--- /srv/rebuilderd/tmp/rebuilderdLRzbJ9/inputs/acm_6.0+20200416-1.2_armhf.deb +++ /srv/rebuilderd/tmp/rebuilderdLRzbJ9/out/acm_6.0+20200416-1.2_armhf.deb ├── file list │ @@ -1,3 +1,3 @@ │ -rw-r--r-- 0 0 0 4 2024-04-25 16:37:07.000000 debian-binary │ --rw-r--r-- 0 0 0 3884 2024-04-25 16:37:07.000000 control.tar.xz │ --rw-r--r-- 0 0 0 534892 2024-04-25 16:37:07.000000 data.tar.xz │ +-rw-r--r-- 0 0 0 3888 2024-04-25 16:37:07.000000 control.tar.xz │ +-rw-r--r-- 0 0 0 533944 2024-04-25 16:37:07.000000 data.tar.xz ├── control.tar.xz │ ├── control.tar │ │ ├── ./md5sums │ │ │ ├── ./md5sums │ │ │ │┄ Files differ ├── data.tar.xz │ ├── data.tar │ │ ├── file list │ │ │ @@ -1,13 +1,13 @@ │ │ │ drwxr-xr-x 0 root (0) root (0) 0 2024-04-25 16:37:07.000000 ./ │ │ │ drwxr-xr-x 0 root (0) root (0) 0 2024-04-25 16:37:07.000000 ./usr/ │ │ │ drwxr-xr-x 0 root (0) root (0) 0 2024-04-25 16:37:07.000000 ./usr/games/ │ │ │ --rwxr-xr-x 0 root (0) root (0) 370416 2024-04-25 16:37:07.000000 ./usr/games/acm │ │ │ +-rwxr-xr-x 0 root (0) root (0) 370264 2024-04-25 16:37:07.000000 ./usr/games/acm │ │ │ -rwxr-xr-x 0 root (0) root (0) 31681 2024-04-25 16:37:07.000000 ./usr/games/acm.tcl │ │ │ --rwxr-xr-x 0 root (0) root (0) 57436 2024-04-25 16:37:07.000000 ./usr/games/dis_relay │ │ │ +-rwxr-xr-x 0 root (0) root (0) 57548 2024-04-25 16:37:07.000000 ./usr/games/dis_relay │ │ │ drwxr-xr-x 0 root (0) root (0) 0 2024-04-25 16:37:07.000000 ./usr/share/ │ │ │ drwxr-xr-x 0 root (0) root (0) 0 2024-04-25 16:37:07.000000 ./usr/share/applications/ │ │ │ drwxr-xr-x 0 root (0) root (0) 0 2024-04-25 16:37:07.000000 ./usr/share/doc/ │ │ │ drwxr-xr-x 0 root (0) root (0) 0 2024-04-25 16:37:07.000000 ./usr/share/doc/acm/ │ │ │ -rw-r--r-- 0 root (0) root (0) 965 2024-04-25 16:37:07.000000 ./usr/share/doc/acm/changelog.Debian.gz │ │ │ -rw-r--r-- 0 root (0) root (0) 22461 2020-04-16 12:05:35.000000 ./usr/share/doc/acm/changelog.gz │ │ │ -rw-r--r-- 0 root (0) root (0) 1069 2020-11-17 11:52:56.000000 ./usr/share/doc/acm/copyright │ │ ├── ./usr/games/acm │ │ │┄ File has been modified after NT_GNU_BUILD_ID has been applied. │ │ │ ├── readelf --wide --file-header {} │ │ │ │ @@ -4,17 +4,17 @@ │ │ │ │ Data: 2's complement, little endian │ │ │ │ Version: 1 (current) │ │ │ │ OS/ABI: UNIX - System V │ │ │ │ ABI Version: 0 │ │ │ │ Type: DYN (Position-Independent Executable file) │ │ │ │ Machine: ARM │ │ │ │ Version: 0x1 │ │ │ │ - Entry point address: 0x440d │ │ │ │ + Entry point address: 0x43a5 │ │ │ │ Start of program headers: 52 (bytes into file) │ │ │ │ - Start of section headers: 369256 (bytes into file) │ │ │ │ + Start of section headers: 369104 (bytes into file) │ │ │ │ Flags: 0x5000400, Version5 EABI, hard-float ABI │ │ │ │ Size of this header: 52 (bytes) │ │ │ │ Size of program headers: 32 (bytes) │ │ │ │ Number of program headers: 9 │ │ │ │ Size of section headers: 40 (bytes) │ │ │ │ Number of section headers: 29 │ │ │ │ Section header string table index: 28 │ │ │ ├── readelf --wide --program-header {} │ │ │ │ @@ -1,24 +1,24 @@ │ │ │ │ │ │ │ │ Elf file type is DYN (Position-Independent Executable file) │ │ │ │ -Entry point 0x440d │ │ │ │ +Entry point 0x43a5 │ │ │ │ There are 9 program headers, starting at offset 52 │ │ │ │ │ │ │ │ Program Headers: │ │ │ │ Type Offset VirtAddr PhysAddr FileSiz MemSiz Flg Align │ │ │ │ - ARM_EXIDX 0x0569bc 0x000569bc 0x000569bc 0x00008 0x00008 R 0x4 │ │ │ │ + ARM_EXIDX 0x0568bc 0x000568bc 0x000568bc 0x00008 0x00008 R 0x4 │ │ │ │ PHDR 0x000034 0x00000034 0x00000034 0x00120 0x00120 R 0x4 │ │ │ │ INTERP 0x000154 0x00000154 0x00000154 0x00019 0x00019 R 0x1 │ │ │ │ [Requesting program interpreter: /lib/ld-linux-armhf.so.3] │ │ │ │ - LOAD 0x000000 0x00000000 0x00000000 0x569c8 0x569c8 R E 0x1000 │ │ │ │ - LOAD 0x056df0 0x00057df0 0x00057df0 0x032ac 0x4ee48 RW 0x1000 │ │ │ │ + LOAD 0x000000 0x00000000 0x00000000 0x568c8 0x568c8 R E 0x1000 │ │ │ │ + LOAD 0x056da8 0x00057da8 0x00057da8 0x0325c 0x4edf8 RW 0x1000 │ │ │ │ DYNAMIC 0x056ef0 0x00057ef0 0x00057ef0 0x00110 0x00110 RW 0x4 │ │ │ │ NOTE 0x000170 0x00000170 0x00000170 0x00044 0x00044 R 0x4 │ │ │ │ GNU_STACK 0x000000 0x00000000 0x00000000 0x00000 0x00000 RW 0x10 │ │ │ │ - GNU_RELRO 0x056df0 0x00057df0 0x00057df0 0x00210 0x00210 R 0x1 │ │ │ │ + GNU_RELRO 0x056da8 0x00057da8 0x00057da8 0x00258 0x00258 R 0x1 │ │ │ │ │ │ │ │ Section to Segment mapping: │ │ │ │ Segment Sections... │ │ │ │ 00 .ARM.exidx │ │ │ │ 01 │ │ │ │ 02 .interp │ │ │ │ 03 .interp .note.gnu.build-id .note.ABI-tag .gnu.hash .dynsym .dynstr .gnu.version .gnu.version_r .rel.dyn .rel.plt .init .plt .text .fini .rodata .ARM.exidx .eh_frame │ │ │ ├── readelf --wide --sections {} │ │ │ │ @@ -1,38 +1,38 @@ │ │ │ │ -There are 29 section headers, starting at offset 0x5a268: │ │ │ │ +There are 29 section headers, starting at offset 0x5a1d0: │ │ │ │ │ │ │ │ Section Headers: │ │ │ │ [Nr] Name Type Addr Off Size ES Flg Lk Inf Al │ │ │ │ [ 0] NULL 00000000 000000 000000 00 0 0 0 │ │ │ │ [ 1] .interp PROGBITS 00000154 000154 000019 00 A 0 0 1 │ │ │ │ [ 2] .note.gnu.build-id NOTE 00000170 000170 000024 00 A 0 0 4 │ │ │ │ [ 3] .note.ABI-tag NOTE 00000194 000194 000020 00 A 0 0 4 │ │ │ │ [ 4] .gnu.hash GNU_HASH 000001b4 0001b4 000044 04 A 5 0 4 │ │ │ │ - [ 5] .dynsym DYNSYM 000001f8 0001f8 000a50 10 A 6 3 4 │ │ │ │ - [ 6] .dynstr STRTAB 00000c48 000c48 000681 00 A 0 0 1 │ │ │ │ - [ 7] .gnu.version VERSYM 000012ca 0012ca 00014a 02 A 5 0 2 │ │ │ │ - [ 8] .gnu.version_r VERNEED 00001414 001414 0000b0 00 A 6 4 4 │ │ │ │ - [ 9] .rel.dyn REL 000014c4 0014c4 001578 08 A 5 0 4 │ │ │ │ - [10] .rel.plt REL 00002a3c 002a3c 0004a0 08 AI 5 22 4 │ │ │ │ - [11] .init PROGBITS 00002edc 002edc 00000c 00 AX 0 0 4 │ │ │ │ - [12] .plt PROGBITS 00002ee8 002ee8 00072c 04 AX 0 0 4 │ │ │ │ - [13] .text PROGBITS 00003618 003618 046274 00 AX 0 0 8 │ │ │ │ - [14] .fini PROGBITS 0004988c 04988c 000008 00 AX 0 0 4 │ │ │ │ - [15] .rodata PROGBITS 00049898 049898 00d124 00 A 0 0 8 │ │ │ │ - [16] .ARM.exidx ARM_EXIDX 000569bc 0569bc 000008 00 AL 13 0 4 │ │ │ │ - [17] .eh_frame PROGBITS 000569c4 0569c4 000004 00 A 0 0 4 │ │ │ │ - [18] .init_array INIT_ARRAY 00057df0 056df0 000004 04 WA 0 0 4 │ │ │ │ - [19] .fini_array FINI_ARRAY 00057df4 056df4 000004 04 WA 0 0 4 │ │ │ │ - [20] .data.rel.ro PROGBITS 00057df8 056df8 0000f8 00 WA 0 0 4 │ │ │ │ + [ 5] .dynsym DYNSYM 000001f8 0001f8 000a30 10 A 6 3 4 │ │ │ │ + [ 6] .dynstr STRTAB 00000c28 000c28 000666 00 A 0 0 1 │ │ │ │ + [ 7] .gnu.version VERSYM 0000128e 00128e 000146 02 A 5 0 2 │ │ │ │ + [ 8] .gnu.version_r VERNEED 000013d4 0013d4 0000b0 00 A 6 4 4 │ │ │ │ + [ 9] .rel.dyn REL 00001484 001484 001578 08 A 5 0 4 │ │ │ │ + [10] .rel.plt REL 000029fc 0029fc 000490 08 AI 5 22 4 │ │ │ │ + [11] .init PROGBITS 00002e8c 002e8c 00000c 00 AX 0 0 4 │ │ │ │ + [12] .plt PROGBITS 00002e98 002e98 000718 04 AX 0 0 4 │ │ │ │ + [13] .text PROGBITS 000035b0 0035b0 04625c 00 AX 0 0 8 │ │ │ │ + [14] .fini PROGBITS 0004980c 04980c 000008 00 AX 0 0 4 │ │ │ │ + [15] .rodata PROGBITS 00049818 049818 00d0a4 00 A 0 0 8 │ │ │ │ + [16] .ARM.exidx ARM_EXIDX 000568bc 0568bc 000008 00 AL 13 0 4 │ │ │ │ + [17] .eh_frame PROGBITS 000568c4 0568c4 000004 00 A 0 0 4 │ │ │ │ + [18] .init_array INIT_ARRAY 00057da8 056da8 000004 04 WA 0 0 4 │ │ │ │ + [19] .fini_array FINI_ARRAY 00057dac 056dac 000004 04 WA 0 0 4 │ │ │ │ + [20] .data.rel.ro PROGBITS 00057db0 056db0 000140 00 WA 0 0 4 │ │ │ │ [21] .dynamic DYNAMIC 00057ef0 056ef0 000110 08 WA 6 0 4 │ │ │ │ - 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1: 00002edc 0 SECTION LOCAL DEFAULT 11 .init │ │ │ │ - 2: 00058340 0 SECTION LOCAL DEFAULT 23 .data │ │ │ │ + 1: 00002e8c 0 SECTION LOCAL DEFAULT 11 .init │ │ │ │ + 2: 00058338 0 SECTION LOCAL DEFAULT 23 .data │ │ │ │ 3: 00000000 0 FUNC GLOBAL DEFAULT UND qsort@GLIBC_2.4 (2) │ │ │ │ 4: 00000000 0 FUNC GLOBAL DEFAULT UND pthread_join@GLIBC_2.34 (3) │ │ │ │ 5: 00000000 0 FUNC GLOBAL DEFAULT UND __fcntl_time64@GLIBC_2.34 (3) │ │ │ │ 6: 00000000 0 FUNC GLOBAL DEFAULT UND strerror@GLIBC_2.4 (2) │ │ │ │ 7: 00000000 0 FUNC GLOBAL DEFAULT UND XCreateFontCursor │ │ │ │ 8: 00000000 0 FUNC GLOBAL DEFAULT UND snd_pcm_close@ALSA_0.9 (4) │ │ │ │ 9: 00000000 0 FUNC GLOBAL DEFAULT UND abort@GLIBC_2.4 (2) │ │ │ │ @@ -105,64 +105,62 @@ │ │ │ │ 101: 00000000 0 FUNC GLOBAL DEFAULT UND __ctype_b_loc@GLIBC_2.4 (2) │ │ │ │ 102: 00000000 0 FUNC GLOBAL DEFAULT UND fprintf@GLIBC_2.4 (2) │ │ │ │ 103: 00000000 0 FUNC GLOBAL DEFAULT UND malloc@GLIBC_2.4 (2) │ │ │ │ 104: 00000000 0 FUNC GLOBAL DEFAULT UND rindex@GLIBC_2.4 (2) │ │ │ │ 105: 00000000 0 FUNC GLOBAL DEFAULT UND __stack_chk_fail@GLIBC_2.4 (2) │ │ │ │ 106: 00000000 0 FUNC GLOBAL DEFAULT UND cfsetospeed@GLIBC_2.4 (2) │ │ │ │ 107: 00000000 0 FUNC GLOBAL DEFAULT UND snd_pcm_pause@ALSA_0.9 (4) │ │ │ │ - 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│ │ │ │ x`9`{h:h │ │ │ │ x`9`;hc+ │ │ │ │ -V │ │ │ │ |D#b2K{D │ │ │ │ (MKF2F9F}D │ │ │ │ MI{DMJyDMO │ │ │ │ BHxDBJ?KzD │ │ │ │ jL{DjI|DjJ │ │ │ │ oF:FAF(F │ │ │ │ kAF8F*F' │ │ │ │ @@ -314,25 +308,25 @@ │ │ │ │ Z-information pool overflow │ │ │ │ ymin = %d, ymax = %d, height = %d │ │ │ │ 0 <= y && y < w->height │ │ │ │ too many vertices │ │ │ │ npts <= MAX_TRANSFORMED_POINTS │ │ │ │ Warning: VColor module performances issue │ │ │ │ invalid RGB: %d,%d,%d │ │ │ │ -../V/VColor.c │ │ │ │ +VColor.c │ │ │ │ sparsearray_get(colors, packed) == c │ │ │ │ invalid color specification: %s │ │ │ │ #%02u%02u%02u │ │ │ │ Warning: unrecognized directive, "%s" │ │ │ │ ENTITIES │ │ │ │ error in file %s (line %d): │ │ │ │ invalid character │ │ │ │ strings cannot span a line │ │ │ │ Premature End-of-file │ │ │ │ -../V/VObjects.c │ │ │ │ +VObjects.c │ │ │ │ VExtrudeObject: can't copy polygons │ │ │ │ VCopyObject: can't copy polygons │ │ │ │ %d %g %g %g │ │ │ │ (%s clip) %d │ │ │ │ invalid color specification │ │ │ │ invalid polygon vertex count │ │ │ │ invalid polygon vertex │ │ │ │ @@ -348,27 +342,42 @@ │ │ │ │ var `i' uninitialized │ │ │ │ internal error polygon vertex out of range: %d (max %d) -- %d │ │ │ │ POLYLINE │ │ │ │ DICTIONARY │ │ │ │ MLINESTYLE │ │ │ │ ACAD_GROUP │ │ │ │ ACAD_MLINESTYLE │ │ │ │ -../V/VPoly.c │ │ │ │ using already released VPolySet │ │ │ │ *** Null Polygon *** │ │ │ │ %d vertices: │ │ │ │ %9.6g %9.6g %9.6g │ │ │ │ front right bottom │ │ │ │ front right top │ │ │ │ front left bottom │ │ │ │ front left top │ │ │ │ aft right bottom │ │ │ │ aft right top │ │ │ │ aft left bottom │ │ │ │ aft left top │ │ │ │ +../util/gui.c │ │ │ │ +XOpenDisplay("%s") failed │ │ │ │ +WM_PROTOCOLS │ │ │ │ +WM_CLOSEDOWN │ │ │ │ +WM_DELETE_WINDOW │ │ │ │ +trying to allocate too many colors, %d maximum allowed │ │ │ │ +failed allocating RGB color %d,%d,%d │ │ │ │ +color index out of the range: %d │ │ │ │ +../util/sparsearray.c │ │ │ │ +Sparse array report about %s: │ │ │ │ + %d total table length │ │ │ │ + %d occupied table entries │ │ │ │ + %d max table entry length │ │ │ │ + %g average table entry length │ │ │ │ + %g variance table entry length │ │ │ │ + %g mean no. of comparisons per search │ │ │ │ ERROR: failed to read file `%s' │ │ │ │ ERROR: file `%s' too long │ │ │ │ ERROR: too many arguments in file `%s' │ │ │ │ cannon shells │ │ │ │ something (presumably a missile) │ │ │ │ %s fired by %s │ │ │ │ entering entity %s not found in the inventory │ │ │ │ @@ -779,15 +788,15 @@ │ │ │ │ %s:%d: check latitude and longitude ordering │ │ │ │ %s:%d: file %s does not exist or it is not readable │ │ │ │ %s:%d: zone %s overlaps with zone %s │ │ │ │ OutputSegment │ │ │ │ DrawScanLine │ │ │ │ Alib_fillPolygonWithMatrix │ │ │ │ VColor_getByRGB │ │ │ │ -?Identification │ │ │ │ +Identification │ │ │ │ Entity Type │ │ │ │ Concatenated │ │ │ │ Category │ │ │ │ Subcategory │ │ │ │ Specific │ │ │ │ Force ID │ │ │ │ Description │ │ │ │ @@ -1079,29 +1088,15 @@ │ │ │ │ opening audio device '%s': %s │ │ │ │ pthread_create() return code %d: cannot create audio feeder thread to play %s │ │ │ │ audio_resample │ │ │ │ audio_feeder │ │ │ │ UNDEFINED │ │ │ │ %s internal error in %s:%d: %s. │ │ │ │ %s: %s: %s. │ │ │ │ -0 <= idx && idx < CLUT_LEN │ │ │ │ -invalid RGB: %d,%d,%d │ │ │ │ -idx < CLUT_LEN │ │ │ │ -invalid color specification: %s │ │ │ │ -XOpenDisplay("%s") failed │ │ │ │ -not implemented │ │ │ │ -WM_PROTOCOLS │ │ │ │ -WM_CLOSEDOWN │ │ │ │ -WM_DELETE_WINDOW │ │ │ │ -trying to allocate too many colors, %d maximum allowed │ │ │ │ -failed allocating RGB color %d,%d,%d │ │ │ │ -color index out of the range: %d │ │ │ │ -index_to_rgb │ │ │ │ -gui_getColorIndex │ │ │ │ -memory.c │ │ │ │ +../../util/memory.c │ │ │ │ size >= 0 │ │ │ │ out of memory from malloc(%d) │ │ │ │ memory corruption detected: not a block allocated by this module │ │ │ │ recursion in destructor detected while releasing block allocated in %s:%d │ │ │ │ resizing block having destructor allocated in %s is not supported │ │ │ │ out of memory from realloc(...,%d) │ │ │ │ dst_capacity >= 1 │ │ │ │ @@ -1114,22 +1109,15 @@ │ │ │ │ %d total blocks, %d bytes wasted. │ │ │ │ memory_allocate_PRIVATE │ │ │ │ memory_realloc_PRIVATE │ │ │ │ memory_strcpy │ │ │ │ min <= max │ │ │ │ prng_getIntInRange │ │ │ │ reader.c │ │ │ │ -sparsearray.c │ │ │ │ -Sparse array report about %s: │ │ │ │ - %d total table length │ │ │ │ - %d occupied table entries │ │ │ │ - %d max table entry length │ │ │ │ - %g average table entry length │ │ │ │ - %g variance table entry length │ │ │ │ - %g mean no. of comparisons per search │ │ │ │ +../../util/timer.c │ │ │ │ varray.c │ │ │ │ this->occupied_no >= 0 │ │ │ │ this->detached_no >= 0 │ │ │ │ this->used_no <= this->allocated_no │ │ │ │ this->occupied_no + this->detached_no == this->used_no │ │ │ │ this->firstOccupied < 0 || this->entries[this->firstOccupied].isOccupied │ │ │ │ this->lastOccupied < 0 || this->entries[this->lastOccupied].isOccupied │ │ │ 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<__bss_end__@@Base+0x9c5dc> │ │ │ │ + blls 14318c <__bss_end__@@Base+0x9c5ec> │ │ │ │ strmi r2, [r6], -r1, lsl #30 │ │ │ │ strcs fp, [r1], #-4036 @ 0xfffff03c │ │ │ │ stcle 6, cr4, [r8, #-608] @ 0xfffffda0 │ │ │ │ svcne 0x0004f855 │ │ │ │ strcc r4, [r1], #-1584 @ 0xfffff9d0 │ │ │ │ - mrc2 0, 6, pc, cr0, cr4, {1} │ │ │ │ + mcr2 0, 6, pc, cr8, cr4, {1} @ │ │ │ │ mvnsle r4, r7, lsr #5 │ │ │ │ movwls r4, #17987 @ 0x4643 │ │ │ │ - mrc2 0, 5, pc, cr2, cr4, {1} │ │ │ │ + mcr2 0, 5, pc, cr10, cr4, {1} @ │ │ │ │ ldrdlt pc, [r4], -r6 │ │ │ │ @ instruction: 0xf1bb9b04 │ │ │ │ andls r0, r7, r0, lsl #30 │ │ │ │ rscshi pc, r6, r0, asr #6 │ │ │ │ ldrdls pc, [r4, pc] │ │ │ │ @ instruction: 0xf8df2500 │ │ │ │ ldrtmi sl, [r0], r4, lsl #3 │ │ │ │ @@ -83,990 +83,990 @@ │ │ │ │ and r9, sl, r4, lsl #4 │ │ │ │ @ instruction: 0xf1054b5d │ │ │ │ ldrbtmi r0, [fp], #-2817 @ 0xfffff4ff │ │ │ │ @ instruction: 0xf8d86098 │ │ │ │ ldrbmi r7, [sp], -r4 │ │ │ │ vqrshl.u8 q10, , q0 │ │ │ │ @ instruction: 0xf8d880db │ │ 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│ vrshr.s64 d20, d29, #64 │ │ │ │ ldmdbmi r9!, {r2, r3, r5, r6, r8, pc} │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - mcr 7, 6, pc, cr10, cr15, {7} @ │ │ │ │ + mcr 7, 6, pc, cr12, cr15, {7} @ │ │ │ │ ldmdblt r8, {r1, r9, sl, lr} │ │ │ │ adcsmi r3, sp, #4194304 @ 0x400000 │ │ │ │ orrhi pc, r3, r0, asr #5 │ │ │ │ @ instruction: 0x46204934 │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - strmi lr, [r2], -r0, asr #29 │ │ │ │ + strmi lr, [r2], -r2, asr #29 │ │ │ │ strcc fp, [r1, #-2328] @ 0xfffff6e8 │ │ │ │ vrshr.s64 d20, d29, #64 │ │ │ │ ldmdbmi r0!, {r0, r1, r2, r7, r8, pc} │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - mrc 7, 5, APSR_nzcv, cr4, cr15, {7} │ │ │ │ + mrc 7, 5, APSR_nzcv, cr6, cr15, {7} │ │ │ │ ldmdblt r8, {r1, r9, sl, lr} │ │ │ │ adcsmi r3, sp, #4194304 @ 0x400000 │ │ │ │ orrhi pc, fp, r0, asr #5 │ │ │ │ strtmi r4, [r0], -fp, lsr #18 │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - strmi lr, [r2], -sl, lsr #29 │ │ │ │ + strmi lr, [r2], -ip, lsr #29 │ │ │ │ strcc fp, [r1, #-2328] @ 0xfffff6e8 │ │ │ │ vrshr.s64 d20, d29, #64 │ │ │ │ stmdbmi r7!, {r0, r1, r2, r3, r7, r8, pc} │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - mrc 7, 4, APSR_nzcv, cr14, cr15, {7} │ │ │ │ + mcr 7, 5, pc, cr0, cr15, {7} @ │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ - blmi 923c24 <__bss_end__@@Base+0x87cfec> │ │ │ │ + blmi 923bbc <__bss_end__@@Base+0x87d01c> │ │ │ │ @ instruction: 0xf1052201 │ │ │ │ ldrbtmi r0, [fp], #-2817 @ 0xfffff4ff │ │ │ │ - blls 15bad4 <__bss_end__@@Base+0xb4e9c> │ │ │ │ + blls 15ba6c <__bss_end__@@Base+0xb4ecc> │ │ │ │ @ instruction: 0xe774601a │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, r9, r0 │ │ │ │ stmdacc sp!, {r0, r2, r5, r6, r8, r9, ip, sp, lr} │ │ │ │ svccc 0x00d0c152 │ │ │ │ - andeq r4, r5, r8, lsr #19 │ │ │ │ - andeq r4, r5, r6, lsr #19 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r6, r4, r2, lsr #22 │ │ │ │ - andeq r0, r0, r4, lsl #5 │ │ │ │ - andeq r0, r0, r8, lsr #6 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - andeq r0, r0, r4, ror #4 │ │ │ │ - andeq r0, r0, r4, lsl r3 │ │ │ │ - andeq r0, r0, ip, lsl r3 │ │ │ │ - andeq r0, r0, r4, ror r2 │ │ │ │ - andeq r0, r0, r4, lsr #5 │ │ │ │ - @ instruction: 0x000002b8 │ │ │ │ + andeq r4, r5, r0, lsl sl │ │ │ │ + andeq r4, r5, lr, lsl #20 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r6, r4, r6, asr sp │ │ │ │ + andeq r0, r0, ip, ror r2 │ │ │ │ + andeq r0, r0, r0, lsr #6 │ │ │ │ andeq r0, r0, r0, lsl #6 │ │ │ │ - andeq r6, r4, lr, asr sl │ │ │ │ - andeq r6, r4, r4, ror #20 │ │ │ │ - andeq r6, r4, r8, ror #20 │ │ │ │ - muleq r5, lr, r2 │ │ │ │ - andeq r6, r4, r8, lsl #20 │ │ │ │ - andeq r6, r4, ip, lsl fp │ │ │ │ - andeq r6, r4, r4, lsl fp │ │ │ │ - andeq r6, r4, lr, lsl #22 │ │ │ │ - andeq r6, r4, sl, lsl #22 │ │ │ │ - andeq r6, r4, r4, lsl #22 │ │ │ │ - strdeq r6, [r4], -sl │ │ │ │ - strdeq r6, [r4], -r0 │ │ │ │ - andeq r6, r4, sl, ror #21 │ │ │ │ - andeq r9, r5, lr, lsl #3 │ │ │ │ + andeq r0, r0, ip, asr r2 │ │ │ │ + andeq r0, r0, ip, lsl #6 │ │ │ │ + andeq r0, r0, r4, lsl r3 │ │ │ │ + andeq r0, r0, ip, ror #4 │ │ │ │ + muleq r0, ip, r2 │ │ │ │ + @ instruction: 0x000002b0 │ │ │ │ + strdeq r0, [r0], -r8 │ │ │ │ + muleq r4, r2, ip │ │ │ │ + muleq r4, r8, ip │ │ │ │ + muleq r4, ip, ip │ │ │ │ + andeq r9, r5, lr, ror #4 │ │ │ │ + andeq r6, r4, ip, lsr ip │ │ │ │ + andeq r6, r4, r0, asr sp │ │ │ │ + andeq r6, r4, r8, asr #26 │ │ │ │ + andeq r6, r4, r2, asr #26 │ │ │ │ + andeq r6, r4, lr, lsr sp │ │ │ │ + andeq r6, r4, r8, lsr sp │ │ │ │ + andeq r6, r4, lr, lsr #26 │ │ │ │ + andeq r6, r4, r4, lsr #26 │ │ │ │ + andeq r6, r4, lr, lsl sp │ │ │ │ + andeq r9, r5, lr, asr r1 │ │ │ │ ldrbtmi r4, [ip], #-3297 @ 0xfffff31f │ │ │ │ @ instruction: 0xf0106860 │ │ │ │ - @ instruction: 0xf8d8f927 │ │ │ │ + @ instruction: 0xf8d8f9c7 │ │ │ │ ldrbmi r3, [fp], #-8 │ │ │ │ - bleq 7fd1c <__bss_start@@Base+0x24c7c> │ │ │ │ + bleq 7fcb4 <__bss_start@@Base+0x24cac> │ │ │ │ ldmdavs r8, {r0, r2, r3, r4, r6, r9, sl, lr}^ │ │ │ │ - blx e3f950 <__bss_end__@@Base+0xd98d18> │ │ │ │ + blx ff63f8e8 <__bss_end__@@Base+0xff598d48> │ │ │ │ ldrdvc pc, [r4], -r8 │ │ │ │ - ldrbmi r6, [pc, #-96] @ 38b8 │ │ │ │ + ldrbmi r6, [pc, #-96] @ 3850 │ │ │ │ svcge 0x0025f73f │ │ │ │ strbmi r9, [r6], -r6, lsl #22 │ │ │ │ @ instruction: 0x46304cd7 │ │ │ │ @ instruction: 0xf0109304 │ │ │ │ - ldrbtmi pc, [ip], #-2321 @ 0xfffff6ef @ │ │ │ │ + ldrbtmi pc, [ip], #-2481 @ 0xfffff64f @ │ │ │ │ stmdavs r2!, {r2, r8, r9, fp, ip, pc} │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ - bmi ff4e47a8 <__bss_end__@@Base+0xff43db70> │ │ │ │ + bmi ff4e4740 <__bss_end__@@Base+0xff43dba0> │ │ │ │ stmib sp, {r1, r3, r4, r7, fp, ip, lr}^ │ │ │ │ ldrmi r2, [r0], -r4, lsl #6 │ │ │ │ - blx fe13f9d4 <__bss_end__@@Base+0xfe098d9c> │ │ │ │ + blx 1f3f96c <__bss_end__@@Base+0x1e98dcc> │ │ │ │ ldrbtmi r4, [sl], #-2768 @ 0xfffff530 │ │ │ │ @ instruction: 0xf0246890 │ │ │ │ - bmi ff402394 <__bss_end__@@Base+0xff35b75c> │ │ │ │ + bmi ff40230c <__bss_end__@@Base+0xff35b76c> │ │ │ │ ldrbtmi r9, [sl], #-2821 @ 0xfffff4fb │ │ │ │ ldmibcs pc!, {r0, r4, r6, r7, fp, sp, lr}^ @ │ │ │ │ msrhi SPSR_fc, #0, 4 │ │ │ │ ldrbtmi r4, [sl], #-2764 @ 0xfffff534 │ │ │ │ mcrrne 8, 5, r6, sl, cr1 │ │ │ │ svccc 0x0080f5b2 │ │ │ │ cmpphi sl, #0, 4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [sl], #-2761 @ 0xfffff537 │ │ │ │ mcrrne 8, 9, r6, sl, cr1 │ │ │ │ svccc 0x0080f5b2 │ │ │ │ movthi pc, #45568 @ 0xb200 @ │ │ │ │ - bmi ff1d5c98 <__bss_end__@@Base+0xff12f060> │ │ │ │ + bmi ff1d5c30 <__bss_end__@@Base+0xff12f090> │ │ │ │ ldrbtmi r4, [sl], #-2503 @ 0xfffff639 │ │ │ │ ldrbtmi r5, [r9], #-2076 @ 0xfffff7e4 │ │ │ │ ldmvs r0, {r1, r2, r6, r7, r8, r9, fp, lr}^ │ │ │ │ stmib sp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blmi ff15099c <__bss_end__@@Base+0xff0a9d64> │ │ │ │ + blmi ff150934 <__bss_end__@@Base+0xff0a9d94> │ │ │ │ ldrbtmi r6, [fp], #-2186 @ 0xfffff776 │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ stmiavs sl, {r0, r1, r3, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf0246809 │ │ │ │ - vldr s30, [pc, #668] @ 3c44 │ │ │ │ + vldr s30, [pc, #636] @ 3bbc │ │ │ │ @ instruction: 0xeeb01baf │ │ │ │ strmi r0, [r4], -r8, lsl #22 │ │ │ │ - blx 183fa46 <__bss_end__@@Base+0x1798e0e> │ │ │ │ + blx 163f9de <__bss_end__@@Base+0x1598e3e> │ │ │ │ @ instruction: 0xf0402c00 │ │ │ │ ldcmi 3, cr8, [ip], #156 @ 0x9c │ │ │ │ stmdbvs r1!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf02e6860 │ │ │ │ - stcls 15, cr15, [r7, #-124] @ 0xffffff84 │ │ │ │ + stcls 15, cr15, [r7, #-92] @ 0xffffffa4 │ │ │ │ strtmi r6, [r9], -r0, lsr #16 │ │ │ │ - ldc2l 0, cr15, [r6], #-232 @ 0xffffff18 │ │ │ │ + stc2l 0, cr15, [lr], #-232 @ 0xffffff18 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ - blmi feda45f8 <__bss_end__@@Base+0xfecfd9c0> │ │ │ │ + blmi feda4590 <__bss_end__@@Base+0xfecfd9f0> │ │ │ │ ldmdbvs r8, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - ldc2l 0, cr15, [lr, #-260] @ 0xfffffefc │ │ │ │ - @ instruction: 0xf872f02f │ │ │ │ + ldc2l 0, cr15, [r6, #-260] @ 0xfffffefc │ │ │ │ + @ instruction: 0xf86af02f │ │ │ │ @ instruction: 0xf0104628 │ │ │ │ - stmdavs r0!, {r0, r4, r5, r7, fp, ip, sp, lr, pc} │ │ │ │ - @ instruction: 0xf8aef010 │ │ │ │ + stmdavs r0!, {r0, r4, r6, r8, fp, ip, sp, lr, pc} │ │ │ │ + @ instruction: 0xf94ef010 │ │ │ │ @ instruction: 0xf0106860 │ │ │ │ - stmiavs r0!, {r0, r1, r3, r5, r7, fp, ip, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf8a8f010 │ │ │ │ + stmiavs r0!, {r0, r1, r3, r6, r8, fp, ip, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf948f010 │ │ │ │ @ instruction: 0xf0106920 │ │ │ │ - bmi feb41c98 <__bss_end__@@Base+0xfea9b060> │ │ │ │ + bmi feb41eb0 <__bss_end__@@Base+0xfea9b310> │ │ │ │ ldrbtmi r4, [sl], #-2988 @ 0xfffff454 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r3, lsl fp │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ @ instruction: 0x83a7f040 │ │ │ │ ldc 0, cr11, [sp], #84 @ 0x54 │ │ │ │ pop {r2, r8, r9, fp, pc} │ │ │ │ @ instruction: 0xf0104ff0 │ │ │ │ - stmibmi r5!, {r0, r2, r4, r7, r8, r9, fp, ip, sp, pc} │ │ │ │ + stmibmi r5!, {r0, r2, r4, r5, sl, fp, ip, sp, pc} │ │ │ │ ldrbtmi r4, [r9], #-2213 @ 0xfffff75b │ │ │ │ @ instruction: 0xf7ff4478 │ │ │ │ - stmiami r4!, {r4, r6, sl, fp, sp, lr, pc} │ │ │ │ + stmiami r4!, {r5, r6, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff4478 │ │ │ │ - andcs lr, r0, r8, lsl sp │ │ │ │ - ldc 7, cr15, [r0, #1020]! @ 0x3fc │ │ │ │ + andcs lr, r0, r0, lsr #26 │ │ │ │ + ldc 7, cr15, [r2, #1020]! @ 0x3fc │ │ │ │ andcs r4, r4, #2637824 @ 0x284000 │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - stcl 7, cr15, [r8, #-1020]! @ 0xfffffc04 │ │ │ │ + ldcl 7, cr15, [r0, #-1020]! @ 0xfffffc04 │ │ │ │ suble r2, pc, r0, lsl #16 │ │ │ │ @ instruction: 0x4620499e │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - ldmdblt r8, {r1, r2, r3, r4, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + ldmdblt r8, {r5, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ adcsmi r3, sp, #4194304 @ 0x400000 │ │ │ │ addshi pc, fp, r0, asr #5 │ │ │ │ @ instruction: 0x4620499a │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - stmdacs r0, {r2, r4, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r4, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ addhi pc, fp, r0 │ │ │ │ @ instruction: 0x46204997 │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - strmi lr, [r1], -ip, lsl #27 │ │ │ │ + strmi lr, [r1], -lr, lsl #27 │ │ │ │ strcc fp, [r1, #-2328] @ 0xfffff6e8 │ │ │ │ vrshr.s64 d20, d29, #64 │ │ │ │ ldmibmi r3, {r1, r3, r4, r5, r6, r7, r9, pc} │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - stc 7, cr15, [r0, #1020] @ 0x3fc │ │ │ │ + stc 7, cr15, [r2, #1020] @ 0x3fc │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ strcc r8, [r1, #-143] @ 0xffffff71 │ │ │ │ vrshr.s64 d4, d29, #64 │ │ │ │ @ instruction: 0xf856808b │ │ │ │ stmibmi sp, {r0, r2, r5, lr} │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - ldcl 7, cr15, [r2, #-1020]! @ 0xfffffc04 │ │ │ │ + ldcl 7, cr15, [r4, #-1020]! @ 0xfffffc04 │ │ │ │ stmibmi fp, {r6, r8, ip, sp, pc} │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - stcl 7, cr15, [ip, #-1020]! @ 0xfffffc04 │ │ │ │ + stcl 7, cr15, [lr, #-1020]! @ 0xfffffc04 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ strdcs r8, [r1], -r7 │ │ │ │ - bleq 7fedc <__bss_start@@Base+0x24e3c> │ │ │ │ - ldc2l 0, cr15, [r2], #-156 @ 0xffffff64 │ │ │ │ + bleq 7fe74 <__bss_start@@Base+0x24e6c> │ │ │ │ + stc2l 0, cr15, [sl], #-156 @ 0xffffff64 │ │ │ │ stcmi 6, cr14, [r5], {69} @ 0x45 │ │ │ │ - bleq 7fee8 <__bss_start@@Base+0x24e48> │ │ │ │ + bleq 7fe80 <__bss_start@@Base+0x24e78> │ │ │ │ stmiavs r0!, {r2, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - @ instruction: 0xf838f010 │ │ │ │ + @ instruction: 0xf8d8f010 │ │ │ │ ldrdcc pc, [r8], -r8 │ │ │ │ eoreq pc, r5, r3, asr r8 @ │ │ │ │ - @ instruction: 0xf94cf010 │ │ │ │ + @ instruction: 0xf9ecf010 │ │ │ │ rscvs r2, r0, r1, lsl #6 │ │ │ │ ldrt r6, [r4], -r3, lsr #1 │ │ │ │ @ instruction: 0xf1054b7d │ │ │ │ - bls 1866fc <__bss_end__@@Base+0xdfac4> │ │ │ │ + bls 186694 <__bss_end__@@Base+0xdfaf4> │ │ │ │ ldmpl r3, {r2, r3, r4, r5, r6, r8, fp, lr}^ │ │ │ │ - bmi 1f14ce4 <__bss_end__@@Base+0x1e6e0ac> │ │ │ │ + bmi 1f14c7c <__bss_end__@@Base+0x1e6e0dc> │ │ │ │ ldmdavs r8, {r1, r3, r4, r5, r6, sl, lr} │ │ │ │ movwls r6, #2195 @ 0x893 │ │ │ │ ldmvs r2, {r0, r1, r4, r6, fp, sp, lr}^ │ │ │ │ - mcrr 7, 15, pc, r4, cr15 @ │ │ │ │ + mrrc 7, 15, pc, r4, cr15 @ │ │ │ │ ldrmi lr, [r1], -r3, lsr #12 │ │ │ │ eoreq pc, r5, r6, asr r8 @ │ │ │ │ - bl ff041b18 <__bss_end__@@Base+0xfef9aee0> │ │ │ │ + bl ff441ab0 <__bss_end__@@Base+0xff39af10> │ │ │ │ andcs r4, r1, #119808 @ 0x1d400 │ │ │ │ - bleq 7ff38 <__bss_start@@Base+0x24e98> │ │ │ │ + bleq 7fed0 <__bss_start@@Base+0x24ec8> │ │ │ │ andsvs r4, r8, fp, ror r4 │ │ │ │ ldrbtmi r4, [fp], #-2931 @ 0xfffff48d │ │ │ │ @ instruction: 0xe614609a │ │ │ │ @ instruction: 0xf8564611 │ │ │ │ @ instruction: 0xf7ff0025 │ │ │ │ - blmi 1c3ea04 <__bss_end__@@Base+0x1b97dcc> │ │ │ │ + blmi 1c3e9dc <__bss_end__@@Base+0x1b97e3c> │ │ │ │ @ instruction: 0xf1052201 │ │ │ │ ldrbtmi r0, [fp], #-2817 @ 0xfffff4ff │ │ │ │ - blmi 1b9bca8 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│ │ - bleq 7ffa4 <__bss_start@@Base+0x24f04> │ │ │ │ + blmi 18bd2c0 <__bss_end__@@Base+0x1816720> │ │ │ │ + bleq 7ff3c <__bss_start@@Base+0x24f34> │ │ │ │ ldmpl r3, {r1, r2, r9, fp, ip, pc}^ │ │ │ │ andsvs r2, sl, r1, lsl #4 │ │ │ │ @ instruction: 0xf856e5df │ │ │ │ @ instruction: 0xf1050025 │ │ │ │ @ instruction: 0xf01d0b01 │ │ │ │ - @ instruction: 0x4604fb5b │ │ │ │ + @ instruction: 0x4604fb53 │ │ │ │ stmdals r7, {r0, r5, r9, sl, lr} │ │ │ │ - stc2 0, cr15, [sl], #208 @ 0xd0 │ │ │ │ - @ instruction: 0xf00f4620 │ │ │ │ - ldrb pc, [r0, #4043] @ 0xfcb @ │ │ │ │ + stc2 0, cr15, [r2], #208 @ 0xd0 │ │ │ │ + @ instruction: 0xf0104620 │ │ │ │ + ldrb pc, [r0, #2155] @ 0x86b @ │ │ │ │ @ instruction: 0x46204957 │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - ldmdblt r8, {r1, r3, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + ldmdblt r8, {r2, r3, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ adcsmi r3, sp, #4194304 @ 0x400000 │ │ │ │ subhi pc, r6, #192, 4 │ │ │ │ ldrdlt pc, [ip, #-143] @ 0xffffff71 │ │ │ │ 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{r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + bleq 7ffc8 <__bss_start@@Base+0x24fc0> │ │ │ │ + b 141bb4 <__bss_end__@@Base+0x9b014> │ │ │ │ vstr d9, [r3, #44] @ 0x2c │ │ │ │ ldr r0, [r8, #2816] @ 0xb00 │ │ │ │ @ instruction: 0x4620493e │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - @ instruction: 0x4601ecb2 │ │ │ │ + @ instruction: 0x4601ecb4 │ │ │ │ cmnle r7, r0, lsl #16 │ │ │ │ adcsmi r3, sp, #4194304 @ 0x400000 │ │ │ │ @ instruction: 0xf856da74 │ │ │ │ @ instruction: 0xf1050025 │ │ │ │ @ instruction: 0xf7ff0b01 │ │ │ │ - @ instruction: 0xed9fe9e2 │ │ │ │ - vldr d7, [pc, #32] @ 3c70 │ │ │ │ - blls 31a878 <__bss_end__@@Base+0x273c40> │ │ │ │ - blvc 1ff4d8 <__bss_end__@@Base+0x1588a0> │ │ │ │ - blvs 17f678 <__bss_end__@@Base+0xd8a40> │ │ │ │ - blvs 3f26c │ │ │ │ + @ instruction: 0xed9fe9f0 │ │ │ │ + vldr d7, [pc, #32] @ 3c08 │ │ │ │ + blls 31a810 <__bss_end__@@Base+0x273c70> │ │ │ │ + blvc 1ff470 <__bss_end__@@Base+0x1588d0> │ │ │ │ + blvs 17f610 <__bss_end__@@Base+0xd8a70> │ │ │ │ + blvs 3f204 │ │ │ │ svclt 0x0000e57b │ │ │ │ subsge r9, r2, #3648 @ 0xe40 │ │ │ │ svccc 0x00a1df46 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ - strdeq r9, [r5], -lr │ │ │ │ - andeq r9, r5, sl, asr #1 │ │ │ │ - andeq r0, r0, r8, lsr #5 │ │ │ │ - andeq r9, r5, lr, lsr #1 │ │ │ │ - andeq r6, r5, lr, asr #27 │ │ │ │ - andeq r6, r5, r2, asr #27 │ │ │ │ - @ instruction: 0x00056db2 │ │ │ │ - andeq r0, r0, r4, asr #5 │ │ │ │ - andeq r9, r5, r2, ror r0 │ │ │ │ - muleq r5, sl, sp │ │ │ │ - andeq sp, r1, r1, lsr sl │ │ │ │ - ldrdeq sp, [r1], -r3 │ │ │ │ - andeq r9, r5, r8, lsr r0 │ │ │ │ - andeq r6, r5, r8, asr #26 │ │ │ │ - strdeq r4, [r5], -sl │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r6, r4, r6, ror #14 │ │ │ │ - muleq r4, ip, r7 │ │ │ │ - muleq r4, ip, r7 │ │ │ │ - andeq r6, r4, sl, lsl #18 │ │ │ │ - andeq r6, r4, r0, lsl sl │ │ │ │ - andeq r6, r4, r4, lsl #20 │ │ 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asr #32 │ │ │ │ + andeq r6, r5, sl, ror #26 │ │ │ │ + andeq sp, r1, r1, lsr #20 │ │ │ │ + andeq sp, r1, r3, asr #23 │ │ │ │ + andeq r9, r5, r8 │ │ │ │ + andeq r6, r5, r8, lsl sp │ │ │ │ + andeq r4, r5, r2, ror #12 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + muleq r4, sl, r9 │ │ │ │ + ldrdeq r6, [r4], -r0 │ │ │ │ + ldrdeq r6, [r4], -r0 │ │ │ │ + andeq r6, r4, lr, lsr fp │ │ │ │ + andeq r6, r4, r4, asr #24 │ │ │ │ + andeq r6, r4, r8, lsr ip │ │ │ │ + andeq r6, r4, r0, lsr ip │ │ │ │ + andeq r6, r4, lr, lsl ip │ │ │ │ + andeq r6, r4, lr, lsl #24 │ │ │ │ + andeq r6, r4, lr, lsl #24 │ │ │ │ + strdeq r8, [r5], -r0 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + muleq r4, r0, sl │ │ │ │ + strdeq r6, [r5], -r0 │ │ │ │ + andeq r6, r5, ip, asr #23 │ │ │ │ + muleq r5, sl, lr │ │ │ │ + andeq r6, r5, lr, lsr #23 │ │ │ │ + andeq r8, r5, ip, ror lr │ │ │ │ + muleq r5, r0, fp │ │ │ │ + andeq r8, r5, lr, asr lr │ │ │ │ + andeq r6, r5, r2, ror fp │ │ │ │ + andeq r8, r5, r0, asr #28 │ │ │ │ + andeq r0, r0, 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│ @ instruction: 0xf10b80f6 │ │ │ │ @ instruction: 0xf8df0b01 │ │ │ │ strtmi r1, [r0], -r8, asr #9 │ │ │ │ tstls sp, r9, ror r4 │ │ │ │ - bl 1bc1eb4 <__bss_end__@@Base+0x1b1b27c> │ │ │ │ + bl 1c41e4c <__bss_end__@@Base+0x1b9b2ac> │ │ │ │ stmdbls sp, {r4, r5, r8, fp, ip, sp, pc} │ │ │ │ ldrmi r4, [fp, #1629]! @ 0x65d │ │ │ │ rschi pc, r7, r0, asr #5 │ │ │ │ - bleq 802f4 <__bss_start@@Base+0x25254> │ │ │ │ + bleq 8028c <__bss_start@@Base+0x25284> │ │ │ │ strtne pc, [ip], #2271 @ 0x8df │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - bl 1841ed0 <__bss_end__@@Base+0x179b298> │ │ │ │ + bl 18c1e68 <__bss_end__@@Base+0x181b2c8> │ │ │ │ stmdblt r8!, {r0, r9, sl, lr} │ │ │ │ ldrmi r4, [fp, #1629]! @ 0x65d │ │ │ │ teqphi r5, r0, asr #5 @ p-variant is OBSOLETE │ │ │ │ - bleq 80310 <__bss_start@@Base+0x25270> │ │ │ │ + bleq 802a8 <__bss_start@@Base+0x252a0> │ │ │ │ ldrne pc, [r4], #2271 @ 0x8df │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - bl 14c1eec <__bss_end__@@Base+0x141b2b4> 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b41f38 <__bss_end__@@Base+0xa9b300> │ │ │ │ + bl bc1ed0 <__bss_end__@@Base+0xb1b330> │ │ │ │ stmdblt r8!, {r0, r9, sl, lr} │ │ │ │ - ldrbmi r4, [pc, #-1629] @ 38e7 │ │ │ │ + ldrbmi r4, [pc, #-1629] @ 387f │ │ │ │ @ instruction: 0x81aff300 │ │ │ │ - bleq 80378 <__bss_start@@Base+0x252d8> │ │ │ │ + bleq 80310 <__bss_start@@Base+0x25308> │ │ │ │ ldrtne pc, [ip], #-2271 @ 0xfffff721 @ │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ @ instruction: 0xf7ff910d │ │ │ │ - stmdbls sp, {r1, r2, r3, r4, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdbls sp, {r5, r8, r9, fp, sp, lr, pc} │ │ │ │ eorsle r2, sp, r0, lsl #16 │ │ │ │ strtne pc, [ip], #-2271 @ 0xfffff721 │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - bl 541f68 <__bss_end__@@Base+0x49b330> │ │ │ │ + bl 5c1f00 <__bss_end__@@Base+0x51b360> │ │ │ │ stmdblt r8!, {r0, r9, sl, lr} │ │ │ │ - ldrbmi r4, [pc, #-1629] @ 3917 │ │ │ │ + ldrbmi r4, [pc, #-1629] @ 38af │ │ │ │ mrshi pc, SP_irq @ │ │ │ │ - bleq 803a8 <__bss_start@@Base+0x25308> │ │ │ │ + bleq 80340 <__bss_start@@Base+0x25338> │ │ │ │ ldrne pc, [r4], #-2271 @ 0xfffff721 │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - bl 1c1f84 <__bss_end__@@Base+0x11b34c> │ │ │ │ + bl 241f1c <__bss_end__@@Base+0x19b37c> │ │ │ │ stmdblt r8!, {r1, r9, sl, lr} │ │ │ │ - ldrbmi r4, [pc, #-1629] @ 3933 │ │ │ │ + ldrbmi r4, [pc, #-1629] @ 38cb │ │ │ │ mrshi pc, LR_svc @ │ │ │ │ - bleq 803c4 <__bss_start@@Base+0x25324> │ │ │ │ + bleq 8035c <__bss_start@@Base+0x25354> │ │ │ │ @ instruction: 0x462049ff │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - stmdblt r8!, {r1, r3, r4, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ - ldrbmi r4, [pc, #-1629] @ 394b │ │ │ │ + stmdblt r8!, {r2, r3, r4, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ + ldrbmi r4, [pc, #-1629] @ 38e3 │ │ │ │ mrshi pc, SP_irq @ │ │ │ │ - bleq 803dc <__bss_start@@Base+0x2533c> │ │ │ │ + bleq 80374 <__bss_start@@Base+0x2536c> │ │ │ │ @ instruction: 0x462049fa │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - stmdblt r8!, {r1, r2, r3, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ - ldrbmi r4, [pc, #-1629] @ 3963 │ │ │ │ + stmdblt r8!, {r4, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ + ldrbmi r4, [pc, #-1629] @ 38fb │ │ │ │ tstphi r3, r0, lsl #6 @ p-variant is OBSOLETE │ │ │ │ - bleq 803f4 <__bss_start@@Base+0x25354> │ │ │ │ + bleq 8038c <__bss_start@@Base+0x25384> │ │ │ │ ldclmi 6, cr4, [r5], #128 @ 0x80 │ │ │ │ @ instruction: 0x4621447c │ │ │ │ - b ff841fd0 <__bss_end__@@Base+0xff79b398> │ │ │ │ + b ff8c1f68 <__bss_end__@@Base+0xff81b3c8> │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ strtmi r8, [r1], -r8, asr #1 │ │ │ │ @ instruction: 0xf0349807 │ │ │ │ - @ instruction: 0xf7fffa6b │ │ │ │ - bmi ffbf2ed0 <__bss_end__@@Base+0xffb4c298> │ │ │ │ + @ instruction: 0xf7fffa63 │ │ │ │ + bmi ffbf2e68 <__bss_end__@@Base+0xffb4c2c8> │ │ │ │ ldrbtmi r4, [sl], #-3055 @ 0xfffff411 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r3, lsl fp │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ adcshi pc, r5, r0, asr #32 │ │ │ │ andslt r2, r5, r1 │ │ │ │ - blhi 13f2f8 <__bss_end__@@Base+0x986c0> │ │ │ │ + blhi 13f290 <__bss_end__@@Base+0x986f0> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ ldrbtmi r4, [r8], #-2280 @ 0xfffff718 │ │ │ │ - mrrc2 0, 0, pc, r6, cr14 @ │ │ │ │ + @ instruction: 0xf842f00f │ │ │ │ stmiami r7!, {r0, r1, r4, r6, r7, sl, sp, lr, pc}^ │ │ │ │ ldrbtmi r9, [r8], #-772 @ 0xfffffcfc │ │ │ │ - mrrc2 0, 0, pc, r0, cr14 @ │ │ │ │ + @ instruction: 0xf83cf00f │ │ │ │ strt r9, [sp], #2820 @ 0xb04 │ │ │ │ movwls r4, #18660 @ 0x48e4 │ │ │ │ - @ instruction: 0xf00e4478 │ │ │ │ - blls 143150 <__bss_end__@@Base+0x9c518> │ │ │ │ + @ instruction: 0xf00f4478 │ │ │ │ + blls 142098 <__bss_end__@@Base+0x9b4f8> │ │ │ │ stmiami r2!, {r1, r2, r3, r4, r7, sl, sp, lr, pc}^ │ │ │ │ ldrbtmi r9, [r8], #-772 @ 0xfffffcfc │ │ │ │ - mcrr2 0, 0, pc, r2, cr14 @ │ │ │ │ - str r9, [pc], #2820 @ 403c │ │ │ │ + @ instruction: 0xf82ef00f │ │ │ │ + str r9, [pc], #2820 @ 3fd4 │ │ │ │ @ instruction: 0xf6bf45bb │ │ │ │ @ instruction: 0xf856ae7e │ │ │ │ stmdavc r3, {r0, r1, r3, r5} │ │ │ │ suble r2, sl, sp, lsr #22 │ │ │ │ - bleq 8047c <__bss_start@@Base+0x253dc> │ │ │ │ - mrc2 0, 7, pc, cr6, cr3, {1} │ │ │ │ - bllt fe082054 <__bss_end__@@Base+0xfdfdb41c> │ │ │ │ + bleq 80414 <__bss_start@@Base+0x2540c> │ │ │ │ + mcr2 0, 7, pc, cr14, cr3, {1} @ │ │ │ │ + bllt fe081fec <__bss_end__@@Base+0xfdfdb44c> │ │ │ │ andcs r4, r1, #216, 16 @ 0xd80000 │ │ │ │ eorne pc, r5, r6, asr r8 @ │ │ │ │ - bleq 80478 <__bss_start@@Base+0x253d8> │ │ │ │ + bleq 80410 <__bss_start@@Base+0x25408> │ │ │ │ @ instruction: 0xf7ff4478 │ │ │ │ - @ instruction: 0xf7ffea90 │ │ │ │ + @ instruction: 0xf7ffea92 │ │ │ │ ldmmi r4, {r1, r2, r4, r5, r6, r8, r9, fp, ip, sp, pc}^ │ │ │ │ ldrbtmi r9, [r8], #-772 @ 0xfffffcfc │ │ │ │ - cdp2 0, 8, cr15, cr4, cr15, {0} │ │ │ │ + @ instruction: 0xff24f00f │ │ │ │ eorvs r9, r0, r4, lsl #22 │ │ │ │ @ instruction: 0xf856e45b │ │ │ │ @ instruction: 0xf1050025 │ │ │ │ @ instruction: 0xf7fe0b01 │ │ │ │ - @ instruction: 0xf027efc2 │ │ │ │ - @ instruction: 0xf7fff997 │ │ │ │ + @ instruction: 0xf027efd0 │ │ │ │ + @ instruction: 0xf7fff98f │ │ │ │ @ instruction: 0x9c07bb64 │ │ │ │ @ instruction: 0xf0344620 │ │ │ │ - @ instruction: 0xf8d8fa0f │ │ │ │ + @ instruction: 0xf8d8fa07 │ │ │ │ strtmi r3, [r0], -r8 │ │ │ │ eorne pc, fp, r3, asr r8 @ │ │ │ │ - bleq 804d4 <__bss_start@@Base+0x25434> │ │ │ │ - blx 1c017c <__bss_end__@@Base+0x119544> │ │ │ │ - bllt 15820ac <__bss_end__@@Base+0x14db474> │ │ │ │ + bleq 8046c <__bss_start@@Base+0x25464> │ │ │ │ + @ instruction: 0xf9fef034 │ │ │ │ + bllt 1582044 <__bss_end__@@Base+0x14db4a4> │ │ │ │ strtmi r4, [r1], -r4, asr #17 │ │ │ │ - bleq 804cc <__bss_start@@Base+0x2542c> │ │ │ │ + bleq 80464 <__bss_start@@Base+0x2545c> │ │ │ │ @ instruction: 0xf00e4478 │ │ │ │ - @ instruction: 0xf7fffbff │ │ │ │ + @ instruction: 0xf7ffffeb │ │ │ │ vstmiami r1, {d27-} │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ - stc2l 0, cr15, [r0, #-60] @ 0xffffffc4 │ │ │ │ + stc2l 0, cr15, [r0, #60]! @ 0x3c │ │ │ │ ldrdcc pc, [r8], -r8 │ │ │ │ eoreq pc, fp, r3, asr r8 @ │ │ │ │ - bleq 80504 <__bss_start@@Base+0x25464> │ │ │ │ - cdp2 0, 5, cr15, cr2, cr15, {0} │ │ │ │ + bleq 8049c <__bss_start@@Base+0x25494> │ │ │ │ + cdp2 0, 15, cr15, cr2, cr15, {0} │ │ │ │ @ instruction: 0xf7ff6020 │ │ │ │ ldmmi sl!, {r2, r3, r4, r5, r8, r9, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf0334478 │ │ │ │ - @ instruction: 0xf7fffeab │ │ │ │ + @ instruction: 0xf7fffea3 │ │ │ │ @ instruction: 0xf856bb36 │ │ │ │ @ instruction: 0xf10b002b │ │ │ │ @ instruction: 0xf7fe0b01 │ │ │ │ - cdp 15, 11, cr14, cr7, cr10, {4} │ │ │ │ + mrc 15, 5, lr, cr7, cr8, {4} │ │ │ │ vmov.f64 d6, #0 @ 0x40000000 2.0 │ │ │ │ - vldr d7, [pc, #256] @ 4204 │ │ │ │ + vldr d7, [pc, #256] @ 419c │ │ │ │ @ instruction: 0xeeb44b88 │ │ │ │ - vldr d0, [pc, #280] @ 4224 │ │ │ │ - blls 29af30 <__bss_end__@@Base+0x1f42f8> │ │ │ │ - blx 43fcd8 <__bss_end__@@Base+0x3990a0> │ │ │ │ + vldr d0, [pc, #280] @ 41bc │ │ │ │ + blls 29aec8 <__bss_end__@@Base+0x1f4328> │ │ │ │ + blx 43fc70 <__bss_end__@@Base+0x3990d0> │ │ │ │ cdp 15, 11, cr11, cr0, cr8, {2} │ │ │ │ vnmul.f64 d7, d7, d6 │ │ │ │ vmul.f64 d7, d7, d4 │ │ │ │ vstr d7, [r3, #20] │ │ │ │ @ instruction: 0xf7ff7b00 │ │ │ │ vstmiami r9!, {d11-d22} │ │ │ │ stmdbvs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ - stc2 0, cr15, [ip, #-60] @ 0xffffffc4 │ │ │ │ + stc2 0, cr15, [ip, #60]! @ 0x3c │ │ │ │ ldrdcc pc, [r8], -r8 │ │ │ │ eoreq pc, fp, r3, asr r8 @ │ │ │ │ - bleq 8056c <__bss_start@@Base+0x254cc> │ │ │ │ - cdp2 0, 1, cr15, cr14, cr15, {0} │ │ │ │ + bleq 80504 <__bss_start@@Base+0x254fc> │ │ │ │ + cdp2 0, 11, cr15, cr14, cr15, {0} │ │ │ │ @ instruction: 0xf7ff6120 │ │ │ │ @ instruction: 0xf856bb08 │ │ │ │ @ instruction: 0xf10b002b │ │ │ │ @ instruction: 0xf7fe0b01 │ │ │ │ - ldc 15, cr14, [pc, #368] @ 42c8 │ │ │ │ + ldc 15, cr14, [pc, #424] @ 4298 │ │ │ │ vmov.16 d0[3], r7 │ │ │ │ @ instruction: 0xf03e0b07 │ │ │ │ - @ instruction: 0xf7fff961 │ │ │ │ + @ instruction: 0xf7fff959 │ │ │ │ @ instruction: 0xf7ffbafa │ │ │ │ - ldmmi sl, {r1, r3, r5, r8, fp, sp, lr, pc} │ │ │ │ + ldmmi sl, {r1, r3, r4, r5, r8, fp, sp, lr, pc} │ │ │ │ eorne pc, r5, r6, asr r8 @ │ │ │ │ @ instruction: 0xf00e4478 │ │ │ │ - @ instruction: 0xf7fffba3 │ │ │ │ + @ instruction: 0xf7ffff8f │ │ │ │ @ instruction: 0xf856baf0 │ │ │ │ andcs r0, sl, #43 @ 0x2b │ │ │ │ - stm ip, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldm ip, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdacs r1, {r2, r4, r7, r9, fp, lr} │ │ │ │ - bleq 805b8 <__bss_start@@Base+0x25518> │ │ │ │ + bleq 80550 <__bss_start@@Base+0x25548> │ │ │ │ svclt 0x00b8447a │ │ │ │ tstvs r0, r1 │ │ │ │ - blt ff882194 <__bss_end__@@Base+0xff7db55c> │ │ │ │ + blt ff88212c <__bss_end__@@Base+0xff7db58c> │ │ │ │ eoreq pc, fp, r6, asr r8 @ │ │ │ │ @ instruction: 0xf7ff4611 │ │ │ │ - blls 27e39c <__bss_end__@@Base+0x1d7764> │ │ │ │ - bleq 805d4 <__bss_start@@Base+0x25534> │ │ │ │ + blls 27e374 <__bss_end__@@Base+0x1d77d4> │ │ │ │ + bleq 8056c <__bss_start@@Base+0x25564> │ │ │ │ @ instruction: 0xf7ff6018 │ │ │ │ @ instruction: 0xf856bad6 │ │ │ │ strtmi r4, [r0], -fp, lsr #32 │ │ │ │ - ldmda r4!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda r4, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ strtmi r4, [r1], -r8, lsl #23 │ │ │ │ mcrrne 12, 1, sl, r2, cr0 │ │ │ │ @ instruction: 0x4620447b │ │ │ │ - stc2 0, cr15, [lr], {9} │ │ │ │ - bmi fe17296c <__bss_end__@@Base+0xfe0cbd34> │ │ │ │ - bleq 805fc <__bss_start@@Base+0x2555c> │ │ │ │ + @ instruction: 0xf87af00a │ │ │ │ + bmi fe172904 <__bss_end__@@Base+0xfe0cbd64> │ │ │ │ + bleq 80594 <__bss_start@@Base+0x2558c> │ │ │ │ @ instruction: 0xf8bd9906 │ │ │ │ ldmdals r0, {r2, r6, ip, sp} │ │ │ │ addshi r5, r3, sl, lsl #17 │ │ │ │ andsvs r4, r0, r1, lsl #23 │ │ │ │ stmiapl fp, {r0, r9, sp}^ │ │ │ │ @ instruction: 0xf7ff601a │ │ │ │ @ instruction: 0xf856bab8 │ │ │ │ ldmdbmi lr!, {r0, r1, r3, r5, lr}^ │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - stmib lr, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - blls 23281c <__bss_end__@@Base+0x18bbe4> │ │ │ │ - bleq 8062c <__bss_start@@Base+0x2558c> │ │ │ │ + ldmib r0, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blls 2327b4 <__bss_end__@@Base+0x18bc14> │ │ │ │ + bleq 805c4 <__bss_start@@Base+0x255bc> │ │ │ │ @ instruction: 0xf7ff6018 │ │ │ │ @ instruction: 0xf8d8baaa │ │ │ │ ldmdami r8!, {r3, ip, sp}^ │ │ │ │ eorne pc, fp, r3, asr r8 @ │ │ │ │ @ instruction: 0xf10b4478 │ │ │ │ @ instruction: 0xf00e0b01 │ │ │ │ - @ instruction: 0xf7fffb51 │ │ │ │ + @ instruction: 0xf7ffff3d │ │ │ │ ldmdbmi r4!, {r1, r2, r3, r4, r7, r9, fp, ip, sp, pc}^ │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - ldmib r6!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib r8!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ cmple fp, r0, lsl #16 │ │ │ │ movwcs r9, #6664 @ 0x1a08 │ │ │ │ - bleq 80660 <__bss_start@@Base+0x255c0> │ │ │ │ + bleq 805f8 <__bss_start@@Base+0x255f0> │ │ │ │ @ instruction: 0xf7ff6013 │ │ │ │ @ instruction: 0xf856ba90 │ │ │ │ - b 13c42ec <__bss_end__@@Base+0x131d6b4> │ │ │ │ + b 13c4284 <__bss_end__@@Base+0x131d6e4> │ │ │ │ smlabbls sp, fp, fp, r0 │ │ │ │ - mcr 7, 7, pc, cr2, cr14, {7} @ │ │ │ │ + mrc 7, 7, APSR_nzcv, cr0, cr14, {7} │ │ │ │ ldrdcc pc, [r8], -r8 │ │ │ │ - blhi dff8cc <__bss_end__@@Base+0xd58c94> │ │ │ │ + blhi dff864 <__bss_end__@@Base+0xd58cc4> │ │ │ │ stmdbls sp, {r0, r1, r3, r4, r6, sl, lr} │ │ │ │ - bleq 10066c <__bss_end__@@Base+0x59a34> │ │ │ │ - blls 23fadc <__bss_end__@@Base+0x198ea4> │ │ │ │ + bleq 100604 <__bss_end__@@Base+0x59a64> │ │ │ │ + blls 23fa74 <__bss_end__@@Base+0x198ed4> │ │ │ │ @ instruction: 0xf7fe6858 │ │ │ │ - mrc 14, 5, lr, cr0, cr6, {6} │ │ │ │ + cdp 14, 11, cr14, cr0, cr4, {7} │ │ │ │ vmov.f64 d1, d0 │ │ │ │ vnmul.f64 d0, d1, d9 │ │ │ │ @ instruction: 0xf03e1b08 │ │ │ │ - @ instruction: 0xf7fff905 │ │ │ │ + @ instruction: 0xf7fff8fd │ │ │ │ ldmdbmi pc, {r1, r4, r5, r6, r9, fp, ip, sp, pc}^ @ │ │ │ │ @ instruction: 0xf856ab10 │ │ │ │ - bge 38432c <__bss_end__@@Base+0x2dd6f4> │ │ │ │ + bge 3842c4 <__bss_end__@@Base+0x2dd724> │ │ │ │ @ instruction: 0xf7fe4479 │ │ │ │ - stmdacs r2, {r1, r4, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r2, {r1, r2, r3, r4, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ ldmdami fp, {r0, r1, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf00e4478 │ │ │ │ - vldr d15, [sp, #84] @ 0x54 │ │ │ │ + ldc 15, cr15, [sp, #4] │ │ │ │ @ instruction: 0xf10b1b10 │ │ │ │ vldr d0, [sp, #4] │ │ │ │ @ instruction: 0xf01e0b0e │ │ │ │ - @ instruction: 0xf7fffc15 │ │ │ │ + @ instruction: 0xf7fffc0d │ │ │ │ @ instruction: 0xf856ba5a │ │ │ │ @ instruction: 0xf10b002b │ │ │ │ @ instruction: 0xf7fe0b01 │ │ │ │ - @ instruction: 0xf01eeeae │ │ │ │ - @ instruction: 0xf7fffc55 │ │ │ │ + @ instruction: 0xf01eeebc │ │ │ │ + @ instruction: 0xf7fffc4d │ │ │ │ @ instruction: 0xf856ba50 │ │ │ │ stmdbmi pc, {r0, r1, r3, r5, lr}^ @ │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - stmdb r6!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb r8!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmdbmi sp, {r4, r5, r8, ip, sp, pc}^ │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - stmdb r0!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb r2!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ mulcs r1, r8, r9 │ │ │ │ - bleq 80708 <__bss_start@@Base+0x25668> │ │ │ │ - @ instruction: 0xf8c8f03e │ │ │ │ - blt f022e0 <__bss_end__@@Base+0xe5b6a8> │ │ │ │ + bleq 806a0 <__bss_start@@Base+0x25698> │ │ │ │ + @ instruction: 0xf8c0f03e │ │ │ │ + blt f02278 <__bss_end__@@Base+0xe5b6d8> │ │ │ │ strtmi r4, [r0], -r7, asr #18 │ │ │ │ @ instruction: 0xf7ff4479 │ │ │ │ - ldmdblt r8!, {r2, r4, r6, r8, fp, sp, lr, pc}^ │ │ │ │ + ldmdblt r8!, {r1, r2, r4, r6, r8, fp, sp, lr, pc}^ │ │ │ │ movwcs r9, #10760 @ 0x2a08 │ │ │ │ - bleq 80724 <__bss_start@@Base+0x25684> │ │ │ │ + bleq 806bc <__bss_start@@Base+0x256b4> │ │ │ │ @ instruction: 0xf7ff6013 │ │ │ │ stmdami r2, {r1, r2, r3, r5, r9, fp, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf10b4621 │ │ │ │ ldrbtmi r0, [r8], #-2817 @ 0xfffff4ff │ │ │ │ - blx ff640344 <__bss_end__@@Base+0xff59970c> │ │ │ │ - blt 98230c <__bss_end__@@Base+0x8db6d4> │ │ │ │ + cdp2 0, 12, cr15, cr4, cr14, {0} │ │ │ │ + blt 9822a4 <__bss_end__@@Base+0x8db704> │ │ │ │ @ instruction: 0x4621483e │ │ │ │ - bleq 80744 <__bss_start@@Base+0x256a4> │ │ │ │ + bleq 806dc <__bss_start@@Base+0x256d4> │ │ │ │ @ instruction: 0xf00e4478 │ │ │ │ - @ instruction: 0xf7fffacf │ │ │ │ + @ instruction: 0xf7fffebb │ │ │ │ svclt 0x0000ba1c │ │ │ │ adcvc sp, r3, sl, lsl #14 │ │ │ │ adcsmi fp, r7, sp, lsl ip │ │ │ │ - bvs fe08acf0 <__bss_end__@@Base+0xfdfe40b8> │ │ │ │ + bvs fe08ac88 <__bss_end__@@Base+0xfdfe40e8> │ │ │ │ svccc 0x00d381da │ │ │ │ mvnpl r8, pc, lsl r5 │ │ │ │ @ instruction: 0x409cf4b8 │ │ │ │ - andeq r6, r4, r2, lsl #16 │ │ │ │ - andeq r6, r4, r0, lsl #16 │ │ │ │ - andeq r6, r4, lr, ror #15 │ │ │ │ + andeq r6, r4, lr, lsr #20 │ │ │ │ + andeq r6, r4, ip, lsr #20 │ │ │ │ + andeq r6, r4, sl, lsl sl │ │ │ │ + andeq r6, r4, r4, lsl #20 │ │ │ │ + andeq r6, r4, lr, ror #19 │ │ │ │ + ldrdeq r6, [r4], -ip │ │ │ │ + ldrdeq r6, [r4], -r2 │ │ │ │ + andeq r6, r4, r8, asr #19 │ │ │ │ + andeq r6, r4, r0, asr #19 │ │ │ │ + andeq r6, r4, sl, lsr #19 │ │ │ │ + andeq r6, r4, r0, lsr #19 │ │ │ │ + andeq r6, r4, lr, lsl #19 │ │ │ │ + andeq r6, r4, ip, ror r9 │ │ │ │ + andeq r6, r4, sl, ror #18 │ │ │ │ + andeq r6, r4, r8, asr r9 │ │ │ │ + andeq r6, r4, sl, asr #18 │ │ │ │ + andeq r6, r4, sl, lsr r9 │ │ │ │ + andeq r6, r4, r2, lsr r9 │ │ │ │ + andeq r6, r4, r8, ror r9 │ │ │ │ + andeq r6, r4, sl, lsr #19 │ │ │ │ + muleq r4, r6, r9 │ │ │ │ + andeq r6, r4, lr, lsl #19 │ │ │ │ + andeq r6, r4, lr, ror r9 │ │ │ │ + andeq r6, r4, ip, ror r9 │ │ │ │ + muleq r4, r4, r9 │ │ │ │ ldrdeq r6, [r4], -r8 │ │ │ │ - andeq r6, r4, r2, asr #15 │ │ │ │ - @ instruction: 0x000467b0 │ │ │ │ - andeq r6, r4, r6, lsr #15 │ │ │ │ - muleq r4, ip, r7 │ │ │ │ - muleq r4, r4, r7 │ │ │ │ - andeq r6, r4, lr, ror r7 │ │ │ │ - andeq r6, r4, r4, ror r7 │ │ │ │ - andeq r6, r4, r2, ror #14 │ │ │ │ - andeq r6, r4, r0, asr r7 │ │ │ │ - andeq r6, r4, lr, lsr r7 │ │ │ │ - andeq r6, r4, ip, lsr #14 │ │ │ │ - andeq r6, r4, lr, lsl r7 │ │ │ │ - andeq r6, r4, lr, lsl #14 │ │ │ │ - andeq r6, r4, r6, lsl #14 │ │ │ │ - andeq r6, r4, ip, asr #14 │ │ │ │ - andeq r6, r4, lr, ror r7 │ │ │ │ - andeq r6, r4, sl, ror #14 │ │ │ │ - andeq r6, r4, r2, ror #14 │ │ │ │ - andeq r6, r4, r2, asr r7 │ │ │ │ - andeq r6, r4, r0, asr r7 │ │ │ │ - andeq r6, r4, r8, ror #14 │ │ │ │ - andeq r6, r4, ip, lsr #15 │ │ │ │ - andeq r4, r5, r6, lsl r0 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r6, r4, r6, asr r8 │ │ │ │ - andeq r6, r4, sl, lsl r8 │ │ │ │ - andeq r6, r4, r4, ror #15 │ │ │ │ - andeq r6, r4, sl, lsr #15 │ │ │ │ - andeq r6, r4, ip, lsl #9 │ │ │ │ - andeq r6, r4, lr, asr r7 │ │ │ │ - andeq r6, r4, r0, ror #7 │ │ │ │ - andeq r8, r5, r0, lsr r9 │ │ │ │ - andeq r6, r4, r4, asr r4 │ │ │ │ - andeq r8, r5, r8, asr #17 │ │ │ │ + andeq r4, r5, lr, ror r0 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r6, r4, r2, lsl #21 │ │ │ │ + andeq r6, r4, r6, asr #20 │ │ │ │ + andeq r6, r4, r0, lsl sl │ │ │ │ + ldrdeq r6, [r4], -r6 @ │ │ │ │ + andeq r5, r4, r0, asr #31 │ │ │ │ + andeq r6, r4, sl, lsl #19 │ │ │ │ andeq r6, r4, r4, lsl r6 │ │ │ │ - muleq r5, r4, r5 │ │ │ │ - andeq r6, r4, r0, asr #10 │ │ │ │ - andeq r0, r0, ip, ror #5 │ │ │ │ - @ instruction: 0x000002b4 │ │ │ │ - andeq r6, r4, r6, lsr r5 │ │ │ │ - strdeq r6, [r4], -r4 │ │ │ │ - andeq r6, r4, lr, lsl #10 │ │ │ │ - strdeq r6, [r4], -r0 │ │ │ │ - andeq r6, r4, ip, ror #7 │ │ │ │ - andeq r6, r4, r6, asr r3 │ │ │ │ - andeq r6, r4, r2, asr r3 │ │ │ │ - andeq r6, r4, r0, asr r4 │ │ │ │ - andeq r6, r4, r2, lsr #6 │ │ │ │ - andeq r6, r4, r8, lsr #8 │ │ │ │ - bleq 40550 │ │ │ │ + andeq r8, r5, r0, lsl #18 │ │ │ │ + andeq r6, r4, r0, lsl #13 │ │ │ │ + muleq r5, r8, r8 │ │ │ │ + andeq r6, r4, r0, asr #16 │ │ │ │ + andeq r6, r5, r4, ror #10 │ │ │ │ + andeq r6, r4, ip, ror #14 │ │ │ │ + andeq r0, r0, r4, ror #5 │ │ │ │ + andeq r0, r0, ip, lsr #5 │ │ │ │ + andeq r6, r4, r2, ror #14 │ │ │ │ + andeq r6, r4, r0, lsr #14 │ │ │ │ + andeq r6, r4, sl, lsr r7 │ │ │ │ + andeq r6, r4, ip, lsl r6 │ │ │ │ + andeq r6, r4, r8, lsl r6 │ │ │ │ + andeq r6, r4, r2, lsl #11 │ │ │ │ + andeq r6, r4, lr, ror r5 │ │ │ │ + andeq r6, r4, ip, ror r6 │ │ │ │ + andeq r6, r4, lr, asr #10 │ │ │ │ + andeq r6, r4, r4, asr r6 │ │ │ │ + bleq 404e8 │ │ │ │ cdpeq 0, 0, cr15, cr0, cr15, {2} │ │ │ │ strbtmi fp, [sl], -r2, lsl #24 │ │ │ │ strlt fp, [r1], #-1028 @ 0xfffffbfc │ │ │ │ @ instruction: 0xa018f8df │ │ │ │ ldrmi sl, [sl], #773 @ 0x305 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ stmdami r4, {r3, sl, ip, sp, pc} │ │ │ │ andeq pc, r0, sl, asr r8 @ │ │ │ │ - stm sl, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - stc 7, cr15, [r6, #1016] @ 0x3f8 │ │ │ │ - andeq r3, r5, r8, asr #23 │ │ │ │ - andeq r0, r0, r4, lsr r3 │ │ │ │ - ldr r3, [pc, #20] @ 445c │ │ │ │ - ldr r2, [pc, #20] @ 4460 │ │ │ │ + stm ip, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldc 7, cr15, [r2, #1016] @ 0x3f8 │ │ │ │ + andeq r3, r5, r0, lsr ip │ │ │ │ + andeq r0, r0, ip, lsr #6 │ │ │ │ + ldr r3, [pc, #20] @ 43f4 │ │ │ │ + ldr r2, [pc, #20] @ 43f8 │ │ │ │ add r3, pc, r3 │ │ │ │ ldr r2, [r3, r2] │ │ │ │ cmp r2, #0 │ │ │ │ bxeq lr │ │ │ │ - b 2f8c <__gmon_start__@plt> │ │ │ │ - @ instruction: 0x00053bb0 │ │ │ │ - andeq r0, r0, r8, ror r2 │ │ │ │ - blmi 1d6484 <__bss_end__@@Base+0x12f84c> │ │ │ │ + b 2f3c <__gmon_start__@plt> │ │ │ │ + andeq r3, r5, r8, lsl ip │ │ │ │ + andeq r0, r0, r0, ror r2 │ │ │ │ + blmi 1d641c <__bss_end__@@Base+0x12f87c> │ │ │ │ ldrbtmi r4, [r8], #-2567 @ 0xfffff5f9 │ │ │ │ ldrbtmi r4, [sl], #-1147 @ 0xfffffb85 │ │ │ │ andle r4, r3, r3, lsl #5 │ │ │ │ ldmpl r3, {r0, r2, r8, r9, fp, lr}^ │ │ │ │ ldrmi fp, [r8, -r3, lsl #2] │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq r6, r5, lr, lsr #24 │ │ │ │ - andeq r6, r5, ip, lsr #24 │ │ │ │ - andeq r3, r5, lr, lsl #23 │ │ │ │ - muleq r0, r8, r2 │ │ │ │ - blmi 2564b8 <__bss_end__@@Base+0x1af880> │ │ │ │ - bmi 25567c <__bss_end__@@Base+0x1aea44> │ │ │ │ - bne 6d568c <__bss_end__@@Base+0x62ea54> │ │ │ │ + strdeq r6, [r5], -lr │ │ │ │ + strdeq r6, [r5], -ip │ │ │ │ + strdeq r3, [r5], -r6 │ │ │ │ + muleq r0, r0, r2 │ │ │ │ + blmi 256450 <__bss_end__@@Base+0x1af8b0> │ │ │ │ + bmi 255614 <__bss_end__@@Base+0x1aea74> │ │ │ │ + bne 6d5624 <__bss_end__@@Base+0x62ea84> │ │ │ │ svceq 0x00d9447a │ │ │ │ @ instruction: 0x01a3eb01 │ │ │ │ andle r1, r3, r9, asr #32 │ │ │ │ ldmpl r3, {r0, r2, r8, r9, fp, lr}^ │ │ │ │ ldrmi fp, [r8, -r3, lsl #2] │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq r6, r5, r4, lsl #24 │ │ │ │ - andeq r6, r5, r0, lsl #24 │ │ │ │ - andeq r3, r5, r0, ror #22 │ │ │ │ - andeq r0, r0, ip, lsr #5 │ │ │ │ - blmi 2b18ec <__bss_end__@@Base+0x20acb4> │ │ │ │ + ldrdeq r6, [r5], -r4 │ │ │ │ + ldrdeq r6, [r5], -r0 │ │ │ │ + andeq r3, r5, r8, asr #23 │ │ │ │ + andeq r0, r0, r4, lsr #5 │ │ │ │ + blmi 2b1884 <__bss_end__@@Base+0x20ace4> │ │ │ │ ldrbtmi r4, [fp], #-2570 @ 0xfffff5f6 │ │ │ │ ldmdavc fp, {r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - blmi 272a84 <__bss_end__@@Base+0x1cbe4c> │ │ │ │ + blmi 272a1c <__bss_end__@@Base+0x1cbe7c> │ │ │ │ ldrdlt r5, [r3, -r3]! │ │ │ │ ldrbtmi r4, [fp], #-2824 @ 0xfffff4f8 │ │ │ │ @ instruction: 0xf7ff6818 │ │ │ │ - @ instruction: 0xf7ffe882 │ │ │ │ - blmi 1c43e8 <__bss_end__@@Base+0x11d7b0> │ │ │ │ + @ instruction: 0xf7ffe884 │ │ │ │ + blmi 1c4380 <__bss_end__@@Base+0x11d7e0> │ │ │ │ ldrbtmi r2, [fp], #-513 @ 0xfffffdff │ │ │ │ stclt 0, cr7, [r8, #-104] @ 0xffffff98 │ │ │ │ - ldrdeq r6, [r5], -r2 │ │ │ │ - andeq r3, r5, r0, lsr fp │ │ │ │ - andeq r0, r0, r0, lsr r3 │ │ │ │ - andeq r3, r5, r6, ror #28 │ │ │ │ - @ instruction: 0x00056bb2 │ │ │ │ + andeq r6, r5, r2, lsr #23 │ │ │ │ + muleq r5, r8, fp │ │ │ │ + andeq r0, r0, r8, lsr #6 │ │ │ │ + andeq r3, r5, r6, asr #29 │ │ │ │ + andeq r6, r5, r2, lsl #23 │ │ │ │ svclt 0x0000e7c4 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5b714 <__bss_end__@@Base+0xfeab4adc> │ │ │ │ + bl feb5b6ac <__bss_end__@@Base+0xfeab4b0c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0x46040ff0 │ │ │ │ movwcs r4, #3389 @ 0xd3d │ │ │ │ ldrbtmi r2, [sp], #-469 @ 0xfffffe2b │ │ │ │ stmiavs r2!, {r2, r3, r9, sl, sp} │ │ │ │ addseq r4, r2, r8, lsr #12 │ │ │ │ - blx 17c056c <__bss_end__@@Base+0x1719934> │ │ │ │ + blx fffc0504 <__bss_end__@@Base+0xfff19964> │ │ │ │ movwcs r6, #2210 @ 0x8a2 │ │ │ │ movvs r2, #-2147483595 @ 0x80000035 │ │ │ │ addseq r4, r2, r8, lsr #12 │ │ │ │ - blx 15c057c <__bss_end__@@Base+0x1519944> │ │ │ │ + blx ffdc0514 <__bss_end__@@Base+0xffd19974> │ │ │ │ addcc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ bicscs r2, r8, r0, lsl #6 │ │ │ │ strtmi r6, [r8], -r0, ror #7 │ │ │ │ vst3.16 {d22-d24}, [pc :128], r2 │ │ │ │ @ instruction: 0xf00f12c0 │ │ │ │ - @ instruction: 0x6c63fa4b │ │ │ │ + @ instruction: 0x6c63faeb │ │ │ │ tstcs r0, r8, lsl r2 │ │ │ │ - blx dd5e2 <__bss_end__@@Base+0x369aa> │ │ │ │ + blx dd57a <__bss_end__@@Base+0x369da> │ │ │ │ @ instruction: 0xf7fef202 │ │ │ │ - stmiavs r2!, {r1, r4, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmiavs r2!, {r5, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ bicscs r2, fp, r0, lsl #6 │ │ │ │ - blx 195e12 <__bss_end__@@Base+0xef1da> │ │ │ │ + blx 195daa <__bss_end__@@Base+0xef20a> │ │ │ │ @ instruction: 0xf00ff202 │ │ │ │ - stmiavs r2!, {r0, r1, r3, r4, r5, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmiavs r2!, {r0, r1, r3, r4, r6, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ movwcs r2, #476 @ 0x1dc │ │ │ │ strtmi r6, [r8], -r0, lsr #6 │ │ │ │ vqdmulh.s d15, d2, d6 │ │ │ │ @ instruction: 0xf00f2606 │ │ │ │ - stmiavs r2!, {r0, r4, r5, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmiavs r2!, {r0, r4, r6, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ bicscs r2, pc, r0, lsl #6 │ │ │ │ strtmi r6, [r8], -r0, ror #6 │ │ │ │ strbvs r0, [r2, #-466]! @ 0xfffffe2e │ │ │ │ vqdmulh.s d15, d2, d6 │ │ │ │ - blx 9c05dc <__bss_end__@@Base+0x9199a4> │ │ │ │ + blx ff1c0574 <__bss_end__@@Base+0xff1199d4> │ │ │ │ tstcs r0, r2, ror #26 │ │ │ │ - blx 19da2a <__bss_end__@@Base+0xf6df2> │ │ │ │ + blx 19d9c2 <__bss_end__@@Base+0xf6e22> │ │ │ │ @ instruction: 0xf7fef202 │ │ │ │ - stmiavs r2!, {r1, r2, r3, r5, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmiavs r2!, {r2, r3, r4, r5, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ mvncs r2, r0, lsl #6 │ │ │ │ bicseq r4, r2, r8, lsr #12 │ │ │ │ - blx 19de46 <__bss_end__@@Base+0xf720e> │ │ │ │ + blx 19ddde <__bss_end__@@Base+0xf723e> │ │ │ │ @ instruction: 0xf00ff202 │ │ │ │ - @ instruction: 0x6e22fa15 │ │ │ │ + @ instruction: 0x6e22fab5 │ │ │ │ strbvs r2, [r0, #256]! @ 0x100 │ │ │ │ vqdmulh.s d15, d2, d6 │ │ │ │ - ldcl 7, cr15, [ip, #-1016] @ 0xfffffc08 │ │ │ │ + stcl 7, cr15, [sl, #-1016]! @ 0xfffffc08 │ │ │ │ movwcs r6, #2210 @ 0x8a2 │ │ │ │ mrscs r2, (UNDEF: 0) │ │ │ │ @ instruction: 0x6663429a │ │ │ │ stmib r4, {r0, r1, r5, r7, r8, sl, sp, lr}^ │ │ │ │ stmib r4, {r1, r4, r8}^ │ │ │ │ ldcle 3, cr2, [r4, #-40] @ 0xffffffd8 │ │ │ │ ldrdeq lr, [ip, -r4] │ │ │ │ strpl lr, [lr], #-2516 @ 0xfffff62c │ │ │ │ - bl 153604 <__bss_end__@@Base+0xac9cc> │ │ │ │ + bl 15359c <__bss_end__@@Base+0xac9fc> │ │ │ │ addvs r0, r3, r2, lsl #5 │ │ │ │ movwcc lr, #2496 @ 0x9c0 │ │ │ │ addvs r3, fp, ip │ │ │ │ movwcc lr, #2497 @ 0x9c1 │ │ │ │ @ instruction: 0xf845310c │ │ │ │ @ instruction: 0xf8443b04 │ │ │ │ addsmi r3, r5, #4, 30 │ │ │ │ ldcllt 1, cr13, [r0, #-964]! @ 0xfffffc3c │ │ │ │ - andeq r5, r4, sl, lsl #8 │ │ │ │ + strdeq r5, [r4], -r2 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb5b820 <__bss_end__@@Base+0xfeab4be8> │ │ │ │ + bl feb5b7b8 <__bss_end__@@Base+0xfeab4c18> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0x46040ff8 │ │ │ │ @ instruction: 0xf00f6b80 │ │ │ │ - blvs ff84306c <__bss_end__@@Base+0xff79c434> │ │ │ │ - blx fe340670 <__bss_end__@@Base+0xfe299a38> │ │ │ │ + blvs ff843284 <__bss_end__@@Base+0xff79c6e4> │ │ │ │ + blx b4060a <__bss_end__@@Base+0xa99a6a> │ │ │ │ @ instruction: 0xf00f6c20 │ │ │ │ - blvs 843060 <__bss_end__@@Base+0x79c428> │ │ │ │ - blx fe1c067c <__bss_end__@@Base+0xfe119a44> │ │ │ │ + blvs 843278 <__bss_end__@@Base+0x79c6d8> │ │ │ │ + blx 9c0616 <__bss_end__@@Base+0x919a76> │ │ │ │ @ instruction: 0xf00f6b60 │ │ │ │ - vstmdbvs r0!, {s30-s160} │ │ │ │ - blx fe040688 <__bss_end__@@Base+0xfdf99a50> │ │ │ │ + fstmdbxvs r0!, {d15-d31} @ Deprecated │ │ │ │ + blx 840622 <__bss_end__@@Base+0x799a82> │ │ │ │ pop {r5, r6, r7, r8, sl, fp, sp, lr} │ │ │ │ @ instruction: 0xf00f4010 │ │ │ │ - svclt 0x0000ba7b │ │ │ │ + svclt 0x0000bb1b │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb5b860 <__bss_end__@@Base+0xfeab4c28> │ │ │ │ + bl feb5b7f8 <__bss_end__@@Base+0xfeab4c58> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0x46050ff0 │ │ │ │ @ instruction: 0xffd6f7ff │ │ │ │ ldrdcs lr, [r8], -r5 │ │ │ │ vstrle s4, [lr, #-0] │ │ │ │ - bl d678 │ │ │ │ + bl d610 │ │ │ │ ldmdavs fp, {r2, r6, r7, r8, r9}^ │ │ │ │ - blle 14f280 <__bss_end__@@Base+0xa8648> │ │ │ │ + blle 14f218 <__bss_end__@@Base+0xa8678> │ │ │ │ eorseq pc, r4, r0, asr r8 @ │ │ │ │ - blx 18c06c4 <__bss_end__@@Base+0x1819a8c> │ │ │ │ + blx c065e <__bss_end__@@Base+0x19abe> │ │ │ │ ldrdcs lr, [r8], -r5 │ │ │ │ adcmi r3, r2, #16777216 @ 0x1000000 │ │ │ │ @ instruction: 0xf00fdcf1 │ │ │ │ - @ instruction: 0x6ee8fa5b │ │ │ │ + @ instruction: 0x6ee8fafb │ │ │ │ ldrhtmi lr, [r8], -sp │ │ │ │ - blt 15c06dc <__bss_end__@@Base+0x1519aa4> │ │ │ │ + blt ffdc0674 <__bss_end__@@Base+0xffd19ad4> │ │ │ │ @ instruction: 0xf00f6880 │ │ │ │ - svclt 0x0000ba53 │ │ │ │ + svclt 0x0000baf3 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00c0f8cc │ │ │ │ strmi fp, [r0], r7, lsl #1 │ │ │ │ stclmi 6, cr4, [r5, #-96] @ 0xffffffa0 │ │ │ │ stmdbeq r0, {r1, r4, r5, r7, r8, ip, sp, lr, pc} │ │ │ │ @@ -1077,84 +1077,84 @@ │ │ │ │ @ instruction: 0xf04fdd67 │ │ │ │ strmi r0, [ip], -r0, lsl #20 │ │ │ │ ldrbmi r2, [r1], -r1, lsl #14 │ │ │ │ andlt pc, r4, sp, asr #17 │ │ │ │ and r9, r4, r5, lsl #10 │ │ │ │ strcc sp, [r1, -r0, ror #2] │ │ │ │ ldrmi r3, [r9, #1028]! @ 0x404 │ │ │ │ - strbmi sp, [pc, #-2890] @ 3baa │ │ │ │ + strbmi sp, [pc, #-2890] @ 3b42 │ │ │ │ @ instruction: 0x6002f9b4 │ │ │ │ @ instruction: 0x0000f9b4 │ │ │ │ - bls 134334 <__bss_end__@@Base+0x8d6fc> │ │ │ │ + bls 1342cc <__bss_end__@@Base+0x8d72c> │ │ │ │ @ instruction: 0x5006f9b4 │ │ │ │ @ instruction: 0x3004f9b4 │ │ │ │ @ instruction: 0x5002f9b2 │ │ │ │ @ instruction: 0xf9b2bf08 │ │ │ │ adcsmi r3, r5, #0 │ │ │ │ @ instruction: 0xf8d8dae8 │ │ │ │ - bne ff03483c <__bss_end__@@Base+0xfef8dc04> │ │ │ │ - blne 1c4578c <__bss_end__@@Base+0x1b9eb54> │ │ │ │ + bne ff0347d4 <__bss_end__@@Base+0xfef8dc34> │ │ │ │ + blne 1c45724 <__bss_end__@@Base+0x1b9eb84> │ │ │ │ movwmi pc, #1283 @ 0x503 @ │ │ │ │ tstcs r8, #134217728 @ 0x8000000 │ │ │ │ @ instruction: 0xf10c0400 │ │ │ │ - blx c4f36 <__bss_end__@@Base+0x1e2fe> │ │ │ │ + blx c4ece <__bss_end__@@Base+0x1e32e> │ │ │ │ @ instruction: 0xf8d8fe0c │ │ │ │ ldrmi r3, [ip, #68] @ 0x44 │ │ │ │ @ instruction: 0xf8c8d03f │ │ │ │ strcc r2, [r1, -r8, asr #32] │ │ │ │ ldrdcs pc, [r0], #-136 @ 0xffffff78 │ │ │ │ - blls 91758 <__bss_start@@Base+0x366b8> │ │ │ │ - bleq 3bf354 <__bss_end__@@Base+0x31871c> │ │ │ │ + blls 916f0 <__bss_start@@Base+0x366e8> │ │ │ │ + bleq 3bf2ec <__bss_end__@@Base+0x31874c> │ │ │ │ andvs pc, lr, r2, lsr #16 │ │ │ │ andcc pc, r4, fp, asr #17 │ │ │ │ - stc2 0, cr15, [sl], #272 @ 0x110 │ │ │ │ + stc2 0, cr15, [r2], #272 @ 0x110 │ │ │ │ @ instruction: 0xf8d89b01 │ │ │ │ ldrmi r2, [r2, #56]! @ 0x38 │ │ │ │ @ instruction: 0x46b2bfb8 │ │ │ │ svclt 0x00a842ab │ │ │ │ movwls r4, #5675 @ 0x162b │ │ │ │ tstcs r1, r3, lsl #22 │ │ │ │ andcc pc, ip, fp, asr #17 │ │ │ │ @ instruction: 0xf85245b9 │ │ │ │ @ instruction: 0xf8cb3025 │ │ │ │ @ instruction: 0xf8cb0008 │ │ │ │ @ instruction: 0xf8423010 │ │ │ │ - ble fed3081c <__bss_end__@@Base+0xfec89be4> │ │ │ │ + ble fed307b4 <__bss_end__@@Base+0xfec89c14> │ │ │ │ ldrdlt pc, [r4], -sp │ │ │ │ @ instruction: 0xf8d8b159 │ │ │ │ ldrbmi r3, [fp, #-40] @ 0xffffffd8 │ │ │ │ ldrdcc pc, [ip], -r8 @ │ │ │ │ @ instruction: 0xf8c8bfc8 │ │ │ │ ldrbmi fp, [r3, #-40] @ 0xffffffd8 │ │ │ │ @ instruction: 0xf8c8bfb8 │ │ │ │ andlt sl, r7, ip, lsr #32 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ ldrmi r4, [sl], -r9, lsr #12 │ │ │ │ @ instruction: 0x46034635 │ │ │ │ ldrmi r4, [r0], -lr, lsl #12 │ │ │ │ - blmi 1fe670 <__bss_end__@@Base+0x157a38> │ │ │ │ + blmi 1fe608 <__bss_end__@@Base+0x157a68> │ │ │ │ stcls 2, cr2, [r5, #-76] @ 0xffffffb4 │ │ │ │ stmdami r6, {r0, r8, sp} │ │ │ │ ldrbtmi r5, [r8], #-2283 @ 0xfffff715 │ │ │ │ andlt r6, r7, fp, lsl r8 │ │ │ │ svcmi 0x00f0e8bd │ │ │ │ - ldclt 7, cr15, [sl, #1016]! @ 0x3f8 │ │ │ │ - andeq r3, r5, r8, lsr r9 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r5, r4, lr, ror #2 │ │ │ │ + stcllt 7, cr15, [sl, #1016] @ 0x3f8 │ │ │ │ + andeq r3, r5, r0, lsr #19 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r5, r4, r6, asr r1 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00d0f8cc │ │ │ │ - bvs 170a00 <__bss_end__@@Base+0xc9dc8> │ │ │ │ + bvs 170998 <__bss_end__@@Base+0xc9df8> │ │ │ │ ldrhtvc pc, [r0], -sp @ │ │ │ │ - ble 18152b8 <__bss_end__@@Base+0x176e680> │ │ │ │ - b 13df110 <__bss_end__@@Base+0x13384d8> │ │ │ │ + ble 1815250 <__bss_end__@@Base+0x176e6b0> │ │ │ │ + b 13df0a8 <__bss_end__@@Base+0x1338508> │ │ │ │ strmi r0, [lr], -r7, asr #23 │ │ │ │ - bl 11626c <__bss_end__@@Base+0x6f634> │ │ │ │ + bl 116204 <__bss_end__@@Base+0x6f664> │ │ │ │ ldrmi r0, [r2], fp, lsl #2 │ │ │ │ stmdavs fp, {r7, r9, sl, lr}^ │ │ │ │ andsle r1, r8, sl, asr ip │ │ │ │ @ instruction: 0xf8542200 │ │ │ │ mrrcne 0, 3, r4, r8, cr7 │ │ │ │ subvs fp, r8, r6, lsr r2 │ │ │ │ vmin.u32 d20, d10, d1 │ │ │ │ @@ -1166,15 +1166,15 @@ │ │ │ │ tstpmi pc, r6, ror #6 @ p-variant is OBSOLETE │ │ │ │ eorle r6, r4, r9, asr r0 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ stmdami r3!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ movwcs r0, #234 @ 0xea │ │ │ │ teqpcc r7, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ eorslt r4, r6, #120, 8 @ 0x78000000 │ │ │ │ - @ instruction: 0xf8caf00f │ │ │ │ + @ instruction: 0xf96af00f │ │ │ │ ldrdcs pc, [r4], -r8 @ │ │ │ │ @ instruction: 0xf8442300 │ │ │ │ @ instruction: 0x46190037 │ │ │ │ ldrdpl pc, [r0], -r8 @ │ │ │ │ eorsmi pc, r7, r2, asr r8 @ │ │ │ │ vqshl.u32 q10, q5, q5 │ │ │ │ vcgt.u32 d16, d9, d15 │ │ │ │ @@ -1187,110 +1187,110 @@ │ │ │ │ strcc r6, [r8], #-0 │ │ │ │ @ instruction: 0x3c04f934 │ │ │ │ @ instruction: 0xf9343408 │ │ │ │ @ instruction: 0xf9342c0e │ │ │ │ smladls r1, r0, ip, r1 │ │ │ │ @ instruction: 0x0c0af934 │ │ │ │ ldrtmi r9, [r0], -r0 │ │ │ │ - @ instruction: 0xf859f00f │ │ │ │ + @ instruction: 0xf906f00f │ │ │ │ mvnle r3, r1, lsl #26 │ │ │ │ ldrdcc pc, [r4], -r8 @ │ │ │ │ subsvs r4, sp, fp, asr r4 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ - blmi 1a8880 <__bss_end__@@Base+0x101c48> │ │ │ │ + blmi 1a8818 <__bss_end__@@Base+0x101c78> │ │ │ │ subcc pc, sp, #64, 4 │ │ │ │ stmdami r6, {r0, r2, r8, fp, lr} │ │ │ │ ldrbtmi r4, [r9], #-1147 @ 0xfffffb85 │ │ │ │ @ instruction: 0xf7fe4478 │ │ │ │ - svclt 0x0000ec12 │ │ │ │ - ldrdeq r5, [r4], -ip │ │ │ │ - andeq r8, r4, r8, lsr #21 │ │ │ │ - andeq r5, r4, r2, rrx │ │ │ │ - andeq r5, r4, ip, ror r0 │ │ │ │ + svclt 0x0000ec20 │ │ │ │ + andeq r5, r4, r4, asr #1 │ │ │ │ + @ instruction: 0x00048cb4 │ │ │ │ + andeq r5, r4, sl, asr #32 │ │ │ │ + andeq r5, r4, r4, rrx │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb5baec <__bss_end__@@Base+0xfeab4eb4> │ │ │ │ + bl feb5ba84 <__bss_end__@@Base+0xfeab4ee4> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stclvs 15, cr0, [r3], {248} @ 0xf8 │ │ │ │ ldrbtmi r4, [r9], #-2331 @ 0xfffff6e5 │ │ │ │ - blcs 70e88 <__bss_start@@Base+0x15de8> │ │ │ │ + blcs 70e20 <__bss_start@@Base+0x15e18> │ │ │ │ ldmib r0, {r0, r1, r2, r5, r8, ip, lr, pc}^ │ │ │ │ addsmi r3, sl, #24, 4 @ 0x80000001 │ │ │ │ stclvs 0, cr13, [r3, #68] @ 0x44 │ │ │ │ mrrcne 1, 0, r2, r4, cr6 │ │ │ │ - blx 5e222 <__bss_start@@Base+0x3182> │ │ │ │ + blx 5e1ba <__bss_start@@Base+0x31b2> │ │ │ │ ldclt 0, cr3, [r0, #-8] │ │ │ │ andscc lr, r5, #208, 18 @ 0x340000 │ │ │ │ mulle r6, sl, r2 │ │ │ │ tstcs r6, r3, lsl #26 │ │ │ │ strvs r1, [r4, #3156] @ 0xc54 │ │ │ │ andcc pc, r2, r1, lsl #22 │ │ │ │ stcmi 13, cr11, [pc], {16} │ │ │ │ stmdavs r3!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ andcs fp, r0, fp, lsl #2 │ │ │ │ - blmi 373d78 <__bss_end__@@Base+0x2cd140> │ │ │ │ + blmi 373d10 <__bss_end__@@Base+0x2cd170> │ │ │ │ stmdami sp, {r0, r1, r4, r6, r9, sp} │ │ │ │ stmiapl fp, {r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldmdavs fp, {r0, r8, sp} │ │ │ │ - stc 7, cr15, [r2, #-1016] @ 0xfffffc08 │ │ │ │ + ldc 7, cr15, [r2, #-1016] @ 0xfffffc08 │ │ │ │ eorvs r2, r3, r1, lsl #6 │ │ │ │ - bmi 27e914 <__bss_end__@@Base+0x1d7cdc> │ │ │ │ + bmi 27e8ac <__bss_end__@@Base+0x1d7d0c> │ │ │ │ bicvc pc, r2, pc, asr #8 │ │ │ │ ldrbtmi r4, [sl], #-2056 @ 0xfffff7f8 │ │ │ │ - @ instruction: 0xf00d4478 │ │ │ │ - @ instruction: 0xf7feff65 │ │ │ │ - svclt 0x0000eaf4 │ │ │ │ - andeq r3, r5, sl, lsl #14 │ │ │ │ - andeq r6, r5, r8, ror r7 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r5, r4, r8, lsr #32 │ │ │ │ - andeq r5, r4, r2, rrx │ │ │ │ - ldrdeq r4, [r4], -r4 @ │ │ │ │ + @ instruction: 0xf00e4478 │ │ │ │ + @ instruction: 0xf7fefb51 │ │ │ │ + svclt 0x0000eb00 │ │ │ │ + andeq r3, r5, r2, ror r7 │ │ │ │ + andeq r6, r5, r8, asr #14 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r5, r4, r0, lsl r0 │ │ │ │ + andeq r5, r4, sl, asr #32 │ │ │ │ + @ instruction: 0x00044fbc │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00e0f8cc │ │ │ │ movwcs r4, #50719 @ 0xc61f │ │ │ │ ldrsbtgt pc, [r0], -r0 @ │ │ │ │ @ instruction: 0xf8bd4614 │ │ │ │ strmi r8, [r5], -r0, lsr #32 │ │ │ │ @ instruction: 0xf601fb03 │ │ │ │ andeq lr, r6, #12, 22 @ 0x3000 │ │ │ │ - blcs 1ebf4 │ │ │ │ + blcs 1eb8c │ │ │ │ ldmdavs r2, {r0, r3, r4, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0x3000f9b2 │ │ │ │ ldrmi r8, [r9], #-2129 @ 0xfffff7af │ │ │ │ - ble 6153e8 <__bss_end__@@Base+0x56e7b0> │ │ │ │ + ble 615380 <__bss_end__@@Base+0x56e7e0> │ │ │ │ addslt r8, fp, #9502720 @ 0x910000 │ │ │ │ andsle r4, r8, r1, asr #10 │ │ │ │ @ instruction: 0xf984fa1f │ │ │ │ movweq lr, #15273 @ 0x3ba9 │ │ │ │ @ instruction: 0x8053b29b │ │ │ │ teqle r7, r0, lsl #22 │ │ │ │ stccc 8, cr15, [r2], {50} @ 0x32 │ │ │ │ suble r4, r0, r3, asr #10 │ │ │ │ stmdbeq r9, {r0, r1, r2, r5, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf8a28014 │ │ │ │ @ instruction: 0xf8a29002 │ │ │ │ pop {r2, pc} │ │ │ │ strdle r8, [r6, -r8] │ │ │ │ strbmi r8, [r1, #-2193] @ 0xfffff76f │ │ │ │ - bne ffef8e00 <__bss_end__@@Base+0xffe521c8> │ │ │ │ + bne ffef8d98 <__bss_end__@@Base+0xffe521f8> │ │ │ │ pop {r0, r1, r4, r6, pc} │ │ │ │ @ instruction: 0x462883f8 │ │ │ │ @ instruction: 0xff72f7ff │ │ │ │ rscsle r2, r0, r0, lsl #16 │ │ │ │ - blne fdf6b4 <__bss_end__@@Base+0xf38a7c> │ │ │ │ + blne fdf64c <__bss_end__@@Base+0xf38aac> │ │ │ │ ldmvs sl, {r0, r1, r4, r5, sl, lr} │ │ │ │ andcc r6, r1, #88 @ 0x58 │ │ │ │ mulhi r4, sl, r0 │ │ │ │ @ instruction: 0xf8a08047 │ │ │ │ pop {r2, pc} │ │ │ │ @ instruction: 0xf7ff83f8 │ │ │ │ stmdacs r0, {r0, r5, r6, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - blvs ab8da4 <__bss_end__@@Base+0xa1216c> │ │ │ │ + blvs ab8d3c <__bss_end__@@Base+0xa1219c> │ │ │ │ andhi pc, r4, r0, lsr #17 │ │ │ │ mulhi r4, r3, r9 │ │ │ │ subhi r1, r4, ip, lsr fp │ │ │ │ andcs r5, r1, #144, 2 @ 0x24 │ │ │ │ andeq lr, r1, #3194880 @ 0x30c000 │ │ │ │ mvnshi lr, #12386304 @ 0xbd0000 │ │ │ │ @ instruction: 0xff50f7ff │ │ │ │ @@ -1306,27 +1306,27 @@ │ │ │ │ svclt 0x00022b01 │ │ │ │ @ instruction: 0xf1036e6b │ │ │ │ @ instruction: 0x666b33ff │ │ │ │ svcne 0x0093d10f │ │ │ │ andcc pc, r4, ip, asr #17 │ │ │ │ stccc 8, cr15, [r6], {50} @ 0x32 │ │ │ │ @ instruction: 0xf8cc3901 │ │ │ │ - bne ffec8aa8 <__bss_end__@@Base+0xffe21e70> │ │ │ │ + bne ffec8a40 <__bss_end__@@Base+0xffe21ea0> │ │ │ │ stccc 8, cr15, [r4], {34} @ 0x22 │ │ │ │ stcvs 7, cr14, [fp, #684]! @ 0x2ac │ │ │ │ strvs r3, [fp, #2817]! @ 0xb01 │ │ │ │ - bmi 1bea54 <__bss_end__@@Base+0x117e1c> │ │ │ │ + bmi 1be9ec <__bss_end__@@Base+0x117e4c> │ │ │ │ bicvc pc, sl, pc, asr #8 │ │ │ │ ldrbtmi r4, [sl], #-2053 @ 0xfffff7fb │ │ │ │ - @ instruction: 0xf00d4478 │ │ │ │ - @ instruction: 0xf7fefec1 │ │ │ │ - @ instruction: 0xf830ea50 │ │ │ │ + @ instruction: 0xf00e4478 │ │ │ │ + @ instruction: 0xf7fefaad │ │ │ │ + @ instruction: 0xf830ea5c │ │ │ │ cdple 12, 15, cr3, cr15, cr2, {0} │ │ │ │ - andeq r4, r4, sl, lsl pc │ │ │ │ - andeq r4, r4, ip, lsl #29 │ │ │ │ + andeq r4, r4, r2, lsl #30 │ │ │ │ + andeq r4, r4, r4, ror lr │ │ │ │ subhi r8, r2, r1 │ │ │ │ svclt 0x00004770 │ │ │ │ @ instruction: 0x469cb510 │ │ │ │ adcmi r9, r2, #512 @ 0x200 │ │ │ │ addsmi fp, r9, #184, 30 @ 0x2e0 │ │ │ │ movwcs fp, #4021 @ 0xfb5 │ │ │ │ ldrmi r2, [lr], r0, lsl #4 │ │ │ │ @@ -1336,39 +1336,39 @@ │ │ │ │ vcgt.f32 d16, d4, d15 │ │ │ │ subvs r4, r3, pc, lsl r3 │ │ │ │ vminnm.f32 d27, d18, d28 │ │ │ │ @ instruction: 0x46724e1f │ │ │ │ ldclt 0, cr6, [r0, #-8] │ │ │ │ @ instruction: 0x2000f9b0 │ │ │ │ @ instruction: 0x3004f9b0 │ │ │ │ - ble 215568 <__bss_end__@@Base+0x16e930> │ │ │ │ + ble 215500 <__bss_end__@@Base+0x16e960> │ │ │ │ @ instruction: 0x3002f9b0 │ │ │ │ @ instruction: 0x2006f9b0 │ │ │ │ svclt 0x00b44293 │ │ │ │ andcs r2, r1, r0 │ │ │ │ andcs r4, r1, r0, ror r7 │ │ │ │ svclt 0x00004770 │ │ │ │ @ instruction: 0xf9b0b510 │ │ │ │ @ instruction: 0xf9b03004 │ │ │ │ @ instruction: 0xf9b0e000 │ │ │ │ - bl febb4b30 <__bss_end__@@Base+0xfeb0def8> │ │ │ │ + bl febb4ac8 <__bss_end__@@Base+0xfeb0df28> │ │ │ │ ldrmi r0, [r9], #-3585 @ 0xfffff1ff │ │ │ │ @ instruction: 0x3006f9b0 │ │ │ │ @ instruction: 0x0c02ebac │ │ │ │ ldrmi r4, [r4, #1050] @ 0x41a │ │ │ │ strmi fp, [lr, #4024] @ 0xfb8 │ │ │ │ movwcs fp, #4021 @ 0xfb5 │ │ │ │ stceq 0, cr15, [r0], {79} @ 0x4f │ │ │ │ movwcs r4, #5660 @ 0x161c │ │ │ │ vminnm.f32 d27, d17, d23 │ │ │ │ strbtmi r0, [r3], -pc, lsl #6 │ │ │ │ - streq pc, [pc], #-878 @ 4b54 │ │ │ │ + streq pc, [pc], #-878 @ 4aec │ │ │ │ tstpmi pc, #-2013265919 @ p-variant is OBSOLETE @ 0x88000001 │ │ │ │ svclt 0x00bc6043 │ │ │ │ - ldrmi pc, [pc], #-876 @ 4b60 │ │ │ │ + ldrmi pc, [pc], #-876 @ 4af8 │ │ │ │ @ instruction: 0xf8c046a4 │ │ │ │ ldclt 0, cr12, [r0, #-0] │ │ │ │ @ instruction: 0x3000f9b1 │ │ │ │ @ instruction: 0xf9b0b510 │ │ │ │ @ instruction: 0xf9b04000 │ │ │ │ addsmi lr, ip, #2 │ │ │ │ @ instruction: 0xc004f9b0 │ │ │ │ @@ -1394,75 +1394,75 @@ │ │ │ │ @ instruction: 0x46644c1f │ │ │ │ ldclt 0, cr6, [r0, #-80] @ 0xffffffb0 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00e8f8cc │ │ │ │ @ instruction: 0xf00e4680 │ │ │ │ - strmi pc, [r5], -ip, lsl #29 │ │ │ │ + strmi pc, [r5], -r1, ror #30 │ │ │ │ @ instruction: 0xf00e4640 │ │ │ │ - mrcmi 14, 1, APSR_nzcv, cr1, cr4, {4} │ │ │ │ - blmi c4fff8 <__bss_end__@@Base+0xba93c0> │ │ │ │ + mrcmi 15, 1, APSR_nzcv, cr1, cr15, {2} │ │ │ │ + blmi c4ff90 <__bss_end__@@Base+0xba93f0> │ │ │ │ strcs fp, [r1, #-4024] @ 0xfffff048 │ │ │ │ svclt 0x00b82801 │ │ │ │ ldrbtmi r2, [lr], #-1 │ │ │ │ ldrbtmi r4, [fp], #-1543 @ 0xfffff9f9 │ │ │ │ vst1.32 {d18-d21}, [pc], r8 │ │ │ │ @ instruction: 0x46307195 │ │ │ │ - cdp2 0, 14, cr15, cr14, cr14, {0} │ │ │ │ + @ instruction: 0xff8ef00e │ │ │ │ @ instruction: 0xf1004604 │ │ │ │ rsbscs r0, ip, #12, 6 @ 0x30000000 │ │ │ │ ldrmi r2, [r8], -r0, lsl #2 │ │ │ │ - b d42c18 <__bss_end__@@Base+0xc9bfe0> │ │ │ │ + b 10c2bb0 <__bss_end__@@Base+0x101c010> │ │ │ │ rsbhi r8, r7, #1342177282 @ 0x50000002 │ │ │ │ andseq pc, r4, #4, 2 │ │ │ │ movwcs r6, #101 @ 0x65 │ │ │ │ ldrdeq lr, [r0, -r0] │ │ │ │ andhi pc, r0, r4, asr #17 │ │ │ │ @ instruction: 0xf04f60a7 │ │ │ │ stm r2, {r0, r1, r2, r3, r4, r5, r6, r7, r8, sl, ip, sp} │ │ │ │ vst4.8 {d16-d19}, [pc], r3 │ │ │ │ vst1.8 {d18-d21}, [pc], r0 │ │ │ │ ldrtmi r4, [r0], -r0, lsl #2 │ │ │ │ vst1.8 {d22}, [pc :128], r1 │ │ │ │ @ instruction: 0xf00e719b │ │ │ │ - strmi pc, [r3], -sp, asr #29 │ │ │ │ + strmi pc, [r3], -sp, ror #30 │ │ │ │ stmib r4, {r5, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7ff531a │ │ │ │ vfma.f32 , , │ │ │ │ movwcs r3, #562 @ 0x232 │ │ │ │ ldrtmi r6, [r0], -r2, lsr #4 │ │ │ │ addsne pc, r0, #76546048 @ 0x4900000 │ │ │ │ orrsvc pc, lr, pc, asr #8 │ │ │ │ - cdp2 0, 11, cr15, cr12, cr14, {0} │ │ │ │ + @ instruction: 0xff5cf00e │ │ │ │ rsbvs r6, r0, #139264 @ 0x22000 │ │ │ │ vstrle s4, [r6, #-0] │ │ │ │ - bl 1648c │ │ │ │ + bl 16424 │ │ │ │ subsvs r0, sp, r2, asr #5 │ │ │ │ addsmi r3, r3, #8, 6 @ 0x20000000 │ │ │ │ stmdami ip, {r0, r1, r3, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ movwge r2, #28928 @ 0x7100 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ tstcs lr, #196, 18 @ 0x310000 │ │ │ │ @ instruction: 0xf0014478 │ │ │ │ @ instruction: 0x4603fe97 │ │ │ │ @ instruction: 0xf8c44620 │ │ │ │ pop {r7, ip, sp} │ │ │ │ svclt 0x000081f0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ rscmi r1, r2, r0, lsl #17 │ │ │ │ - andeq r4, r4, lr, lsr #26 │ │ │ │ + andeq r4, r4, r6, lsl sp │ │ │ │ @ instruction: 0xfffffa53 │ │ │ │ - andeq r4, r4, r0, lsr sp │ │ │ │ + andeq r4, r4, r8, lsl sp │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5bec8 <__bss_end__@@Base+0xfeab5290> │ │ │ │ + bl feb5be60 <__bss_end__@@Base+0xfeab52c0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stmdbcs r1, {r4, r5, r6, r7, r8, r9, sl, fp} │ │ │ │ svclt 0x00b86843 │ │ │ │ - bcs 4d0dc │ │ │ │ + bcs 4d074 │ │ │ │ andcs fp, r1, #184, 30 @ 0x2e0 │ │ │ │ strmi r4, [sp], -r4, lsl #12 │ │ │ │ addmi r4, fp, #23068672 @ 0x1600000 │ │ │ │ stmvs r3, {r1, r8, ip, lr, pc} │ │ │ │ mlasle r3, r3, r2, r4 │ │ │ │ @ instruction: 0xf7ff4620 │ │ │ │ @ instruction: 0xf9b4fc93 │ │ │ │ @@ -1485,47 +1485,47 @@ │ │ │ │ strmi r4, [r2], -r1, lsl #12 │ │ │ │ adchi r4, r0, #3145728 @ 0x300000 │ │ │ │ andlt fp, r9, #760 @ 0x2f8 │ │ │ │ andslt fp, fp, #536870913 @ 0x20000001 │ │ │ │ rschi r4, r1, #32, 12 @ 0x2000000 │ │ │ │ cmnhi r3, #-2013265920 @ 0x88000000 │ │ │ │ ldrhtmi lr, [r0], #-141 @ 0xffffff73 │ │ │ │ - bllt ff742d50 <__bss_end__@@Base+0xff69c118> │ │ │ │ + bllt ff742ce8 <__bss_end__@@Base+0xff69c148> │ │ │ │ svclt 0x0000bd70 │ │ │ │ tstlt r9, r3, asr #19 │ │ │ │ nopeq {67} @ 0x43 │ │ │ │ ldrbmi r6, [r0, -r3, asr #3]! │ │ │ │ nopeq {35} @ 0x23 │ │ │ │ ldrbmi r6, [r0, -r3, asr #3]! │ │ │ │ - bcs 1ef78 │ │ │ │ - blvs 10fc194 <__bss_end__@@Base+0x105555c> │ │ │ │ + bcs 1ef10 │ │ │ │ + blvs 10fc12c <__bss_end__@@Base+0x105558c> │ │ │ │ tstcs r0, ip │ │ │ │ andcc pc, r2, #0, 22 │ │ │ │ movwcc r6, #49305 @ 0xc099 │ │ │ │ @ instruction: 0xd1fb4293 │ │ │ │ svclt 0x00004770 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb5bf90 <__bss_end__@@Base+0xfeab5358> │ │ │ │ + bl feb5bf28 <__bss_end__@@Base+0xfeab5388> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0x46030ff0 │ │ │ │ andseq lr, ip, #208, 18 @ 0x340000 │ │ │ │ - ble 2957a8 <__bss_end__@@Base+0x1eeb70> │ │ │ │ + ble 295740 <__bss_end__@@Base+0x1eeba0> │ │ │ │ mrrcne 14, 13, r6, r0, cr13 │ │ │ │ smmlavs r8, r2, r1, r0 │ │ │ │ cdpvs 8, 9, cr1, cr12, cr8, {5} │ │ │ │ ldrvs r3, [ip], r1, lsl #24 │ │ │ │ adcpl r6, r9, #68 @ 0x44 │ │ │ │ - bmi 174298 <__bss_end__@@Base+0xcd660> │ │ │ │ + bmi 174230 <__bss_end__@@Base+0xcd690> │ │ │ │ stmdami r5, {r8, r9, sp} │ │ │ │ cmppmi fp, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - ldc2 0, cr15, [r0, #-52]! @ 0xffffffcc │ │ │ │ - ldm lr!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - andeq r4, r4, r0, lsl ip │ │ │ │ - andeq r4, r4, sl, ror #22 │ │ │ │ + @ instruction: 0xf91cf00e │ │ │ │ + stmia sl, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + strdeq r4, [r4], -r8 │ │ │ │ + andeq r4, r4, r2, asr fp │ │ │ │ @ instruction: 0x3000f9b1 │ │ │ │ @ instruction: 0xf9b0b510 │ │ │ │ @ instruction: 0xf9b0400c │ │ │ │ addsmi lr, ip, #14 │ │ │ │ @ instruction: 0xc010f9b0 │ │ │ │ @ instruction: 0x461cbfb8 │ │ │ │ @ instruction: 0x3002f9b1 │ │ │ │ @@ -1555,75 +1555,75 @@ │ │ │ │ @ instruction: 0x4018f9b0 │ │ │ │ ldcle 2, cr4, [sl, #-560]! @ 0xfffffdd0 │ │ │ │ @ instruction: 0x4016f9b0 │ │ │ │ ldcle 2, cr4, [r6], #-592 @ 0xfffffdb0 │ │ │ │ @ instruction: 0x401af9b0 │ │ │ │ ldcle 2, cr4, [r2, #-592]! @ 0xfffffdb0 │ │ │ │ ldrvs lr, [r1], #-2512 @ 0xfffff630 │ │ │ │ - ldrbcc pc, [pc, #79]! @ 4ebb @ │ │ │ │ + ldrbcc pc, [pc, #79]! @ 4e53 @ │ │ │ │ stcne 0, cr6, [r5], #628 @ 0x274 │ │ │ │ stmdale fp!, {r0, r2, r4, r5, r7, r9, lr} │ │ │ │ ldrcs r6, [r8, #-1157] @ 0xfffffb7b │ │ │ │ stceq 1, cr15, [r1], {2} │ │ │ │ streq r6, [r9], #-2950 @ 0xfffff47a │ │ │ │ @ instruction: 0xf404fb05 │ │ │ │ - blx 3dfe9c <__bss_end__@@Base+0x339264> │ │ │ │ + blx 3dfe34 <__bss_end__@@Base+0x339294> │ │ │ │ @ instruction: 0xf856fc8c │ │ │ │ @ instruction: 0xf1047022 │ │ │ │ @ instruction: 0xf5010e18 │ │ │ │ @ instruction: 0xf8254100 │ │ │ │ @ instruction: 0xf825c00e │ │ │ │ strtmi ip, [ip], #-4 │ │ │ │ @ instruction: 0xf04f4475 │ │ │ │ rsbvs r0, r9, r0, lsl #24 │ │ │ │ - bvs fe05d030 <__bss_end__@@Base+0xfdfb63f8> │ │ │ │ + bvs fe05cfc8 <__bss_end__@@Base+0xfdfb6428> │ │ │ │ andgt pc, r8, r4, asr #17 │ │ │ │ addsmi r6, r1, #235 @ 0xeb │ │ │ │ - bvs ff0dd244 <__bss_end__@@Base+0xff03660c> │ │ │ │ + bvs ff0dd1dc <__bss_end__@@Base+0xff03663c> │ │ │ │ @ instruction: 0x6125612f │ │ │ │ eormi pc, r2, r6, asr #16 │ │ │ │ addvs fp, r2, #200, 30 @ 0x320 │ │ │ │ svclt 0x00b84293 │ │ │ │ ldcllt 2, cr6, [r0, #776]! @ 0x308 │ │ │ │ andscs r4, r3, #6144 @ 0x1800 │ │ │ │ tstcs r1, r6, lsl #16 │ │ │ │ ldrhtmi lr, [r0], #141 @ 0x8d │ │ │ │ @ instruction: 0xf85c4478 │ │ │ │ ldmdavs fp, {r0, r1, ip, sp} │ │ │ │ - blt cc2edc <__bss_end__@@Base+0xc1c2a4> │ │ │ │ - @ instruction: 0x000531ba │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r4, r4, ip, asr sl │ │ │ │ + blt 10c2e74 <__bss_end__@@Base+0x101c2d4> │ │ │ │ + andeq r3, r5, r2, lsr #4 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r4, r4, r4, asr #20 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00c0f8cc │ │ │ │ addlt r4, r7, r2, lsl #13 │ │ │ │ ldrdlt pc, [r8], -r0 @ │ │ │ │ @ instruction: 0xf04f2600 │ │ │ │ @ instruction: 0x674632ff │ │ │ │ ldrdcc pc, [r8], -sl │ │ │ │ @ instruction: 0x668245b3 │ │ │ │ - bvs ff029b2c <__bss_end__@@Base+0xfef82ef4> │ │ │ │ + bvs ff029ac4 <__bss_end__@@Base+0xfef82f24> │ │ │ │ sbchi pc, r4, #192, 4 │ │ │ │ vrshl.u8 d4, d3, d16 │ │ │ │ addsmi r8, r8, #268435468 @ 0x1000000c │ │ │ │ adcshi pc, lr, #128, 4 │ │ │ │ movwpl lr, #59866 @ 0xe9da │ │ │ │ - b 13d67fc <__bss_end__@@Base+0x132fbc4> │ │ │ │ + b 13d6794 <__bss_end__@@Base+0x132fbf4> │ │ │ │ ldrtmi r0, [r7], -fp, lsl #25 │ │ │ │ @ instruction: 0xf8cd4699 │ │ │ │ @ instruction: 0xf859a00c │ │ │ │ stmdblt r9, {r2, r3, ip} │ │ │ │ ldrmi lr, [r9], -r3, lsl #2 │ │ │ │ cmpvs pc, fp, lsl #18 │ │ │ │ - blcs 1678c │ │ │ │ + blcs 16724 │ │ │ │ @ instruction: 0xf10bd1f9 │ │ │ │ strcs r0, [r0], -r1, lsl #8 │ │ │ │ - bl 156838 <__bss_end__@@Base+0xafc00> │ │ │ │ + bl 1567d0 <__bss_end__@@Base+0xafc30> │ │ │ │ eorlt r0, r4, #12, 28 @ 0xc0 │ │ │ │ mul r3, r0, r6 │ │ │ │ @ instruction: 0x460e6171 │ │ │ │ mvnlt r6, r9, asr #18 │ │ │ │ @ instruction: 0x3000f9b1 │ │ │ │ ldclle 5, cr4, [r9, #364]! @ 0x16c │ │ │ │ stmvs sl, {r0, r1, r3, r6, fp, sp, lr} │ │ │ │ @@ -1645,39 +1645,39 @@ │ │ │ │ ldrtmi r8, [r4], -pc, asr #2 │ │ │ │ @ instruction: 0xf0402a00 │ │ │ │ cmnvs r2, ip, asr r1 │ │ │ │ @ instruction: 0xb1ae6936 │ │ │ │ ldrd pc, [r4], -r6 │ │ │ │ movwcs r4, #1569 @ 0x621 │ │ │ │ stmdbvs sl, {r2, sp, lr, pc}^ │ │ │ │ - bcs 16800 │ │ │ │ + bcs 16798 │ │ │ │ @ instruction: 0x4611d05a │ │ │ │ ldrmi r6, [r6, #2122] @ 0x84a │ │ │ │ - blcs 3c3bc │ │ │ │ + blcs 3c354 │ │ │ │ sbcshi pc, pc, r0 │ │ │ │ cmpvs lr, sl, lsl #12 │ │ │ │ ldmdbvs r6!, {r1, r4, r5, r6, r8, sp, lr} │ │ │ │ mvnle r2, r0, lsl #28 │ │ │ │ - blcs 1f580 │ │ │ │ + blcs 1f518 │ │ │ │ mrshi pc, (UNDEF: 71) @ │ │ │ │ rscscc pc, pc, #79 @ 0x4f │ │ │ │ stmdbeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ strls r4, [r5], #-1573 @ 0xfffff9db │ │ │ │ stcls 6, cr4, [r4], {148} @ 0x94 │ │ │ │ eors r4, r0, lr, asr #12 │ │ │ │ stmdacs r0, {r3, r4, r6, r7, fp, sp, lr} │ │ │ │ addvs sp, r1, lr, lsr r0 │ │ │ │ sbcvs fp, r8, r1, lsl #2 │ │ │ │ mvnscc pc, pc, asr #32 │ │ │ │ mcrcs 0, 0, r6, cr0, cr9, {4} │ │ │ │ ldmdavs r1!, {r2, r3, r4, r5, ip, lr, pc}^ │ │ │ │ - bmi abf964 <__bss_end__@@Base+0xa18d2c> │ │ │ │ + bmi abf8fc <__bss_end__@@Base+0xa18d5c> │ │ │ │ stmdble r3, {r0, r5, r6, r8, sl, lr} │ │ │ │ - beq 81458 <__bss_start@@Base+0x263b8> │ │ │ │ - blle 656774 <__bss_end__@@Base+0x5afb3c> │ │ │ │ + beq 813f0 <__bss_start@@Base+0x263e8> │ │ │ │ + blle 65670c <__bss_end__@@Base+0x5afb6c> │ │ │ │ mrrcne 8, 3, r8, r0, cr3 │ │ │ │ ldrmi sp, [r9, #19] │ │ │ │ ldrmi fp, [r2], r8, lsl #30 │ │ │ │ ldrbmi sp, [ip, #-15] │ │ │ │ eorhi pc, r3, #64, 6 │ │ │ │ stcle 5, cr4, [sl, #-584] @ 0xfffffdb8 │ │ │ │ ldrbmi r9, [r3], -r3, lsl #24 │ │ │ │ @@ -1712,35 +1712,35 @@ │ │ │ │ stcle 5, cr4, [r9, #-576] @ 0xfffffdc0 │ │ │ │ strbmi r9, [r3], -r3, lsl #26 │ │ │ │ @ instruction: 0xf8cd4659 │ │ │ │ strtmi r9, [r8], -r0 │ │ │ │ mrrc2 7, 15, pc, r4, cr15 @ │ │ │ │ movwls r6, #18603 @ 0x48ab │ │ │ │ @ instruction: 0xf10b9b03 │ │ │ │ - bvs ff607ce4 <__bss_end__@@Base+0xff5610ac> │ │ │ │ + bvs ff607c7c <__bss_end__@@Base+0xff5610dc> │ │ │ │ rsble r2, r8, r0, lsl #28 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ adcsvs r4, r3, r3, lsl #11 │ │ │ │ sbcshi pc, r0, r0, lsl #6 │ │ │ │ ldmib r3, {r0, r1, r8, r9, fp, ip, pc}^ │ │ │ │ - b 13db530 <__bss_end__@@Base+0x13348f8> │ │ │ │ + b 13db4c8 <__bss_end__@@Base+0x1334928> │ │ │ │ strcs r0, [r0], -fp, lsl #25 │ │ │ │ vmlaeq.f64 d14, d12, d5 │ │ │ │ and r4, ip, r2, lsr r6 │ │ │ │ addmi r6, fp, #7405568 @ 0x710000 │ │ │ │ cmnvs r4, r7, lsr #31 │ │ │ │ @ instruction: 0xf8de4626 │ │ │ │ @ instruction: 0x61233000 │ │ │ │ @ instruction: 0xf8cebfb8 │ │ │ │ stmdbvs r4!, {lr}^ │ │ │ │ @ instruction: 0xf9b4b174 │ │ │ │ ldrbmi r3, [fp, #-0] │ │ │ │ ldmib r4, {r0, r3, r4, r5, r6, r7, ip, lr, pc}^ │ │ │ │ strmi r3, [fp], #-257 @ 0xfffffeff │ │ │ │ - bcs 1d2bc │ │ │ │ + bcs 1d254 │ │ │ │ strtmi sp, [r6], -r8, ror #3 │ │ │ │ stmdbvs r4!, {r1, r5, r9, sl, lr}^ │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ @ instruction: 0xf43f2e00 │ │ │ │ @ instruction: 0xf859aefe │ │ │ │ cmnvs r4, ip │ │ │ │ @ instruction: 0xf47f2900 │ │ │ │ @@ -1768,57 +1768,57 @@ │ │ │ │ @ instruction: 0x4634e77e │ │ │ │ ldr r4, [pc, -sl, lsl #12] │ │ │ │ ldmdavs r1!, {r3, r4, r7, sp, lr}^ │ │ │ │ andcc pc, r8, lr, asr #17 │ │ │ │ and pc, ip, r3, asr #17 │ │ │ │ strmi lr, [r3, #1846] @ 0x736 │ │ │ │ @ instruction: 0x469add9a │ │ │ │ - blvs 6ec9d0 <__bss_end__@@Base+0x645d98> │ │ │ │ + blvs 6ec968 <__bss_end__@@Base+0x645dc8> │ │ │ │ @ instruction: 0xf8da2e00 │ │ │ │ @ instruction: 0x46181034 │ │ │ │ stmib sl, {r2, r3, r5, r6, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf8da130c │ │ │ │ - blcs 11304 │ │ │ │ + blcs 1129c │ │ │ │ cmpphi r2, r0 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf8ca2300 │ │ │ │ @ instruction: 0xf8ca304c │ │ │ │ @ instruction: 0xf8da3058 │ │ │ │ strcs r1, [r0], -r0, lsr #32 │ │ │ │ adcsmi r9, r1, #4, 22 @ 0x1000 │ │ │ │ eorcc pc, r8, sl, asr #17 │ │ │ │ subvs pc, r8, sl, asr #17 │ │ │ │ eorvs pc, ip, sl, asr #17 │ │ │ │ @ instruction: 0xf8dadd29 │ │ │ │ and r3, r2, r4, lsr #32 │ │ │ │ addmi r3, lr, #1048576 @ 0x100000 │ │ │ │ - b 13fba94 <__bss_end__@@Base+0x1354e5c> │ │ │ │ - bl c7924 <__bss_end__@@Base+0x20cec> │ │ │ │ + b 13fba2c <__bss_end__@@Base+0x1354e8c> │ │ │ │ + bl c78bc <__bss_end__@@Base+0x20d1c> │ │ │ │ ldmdavs r5, {r0, r3, r9}^ │ │ │ │ ldclle 13, cr2, [r5] │ │ │ │ eorsmi pc, r6, r3, asr r8 @ │ │ │ │ ldrdhi pc, [r0], -sl │ │ │ │ @ instruction: 0xf9343408 │ │ │ │ strbmi r3, [r0], -r4, lsl #24 │ │ │ │ @ instruction: 0x2c06f934 │ │ │ │ @ instruction: 0xf9343408 │ │ │ │ @ instruction: 0x96011c10 │ │ │ │ @ instruction: 0x7c0af934 │ │ │ │ @ instruction: 0xf00e9700 │ │ │ │ - vstrcc d15, [r1, #-584] @ 0xfffffdb8 │ │ │ │ + stccc 12, cr15, [r1, #-252] @ 0xffffff04 │ │ │ │ ldmib sl, {r0, r1, r2, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ strcc r1, [r1], -r8, lsl #6 │ │ │ │ addmi r4, lr, #-1728053248 @ 0x99000000 │ │ │ │ andpl pc, r4, r9, asr #17 │ │ │ │ ldrdlt sp, [r7], -fp │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf0402a00 │ │ │ │ - blls e56f0 <__bss_end__@@Base+0x3eab8> │ │ │ │ - blvs 6cd690 <__bss_end__@@Base+0x626a58> │ │ │ │ + blls e5688 <__bss_end__@@Base+0x3eae8> │ │ │ │ + blvs 6cd628 <__bss_end__@@Base+0x626a88> │ │ │ │ tstpcc fp, r1, lsl #22 @ p-variant is OBSOLETE │ │ │ │ - bleq 81694 <__bss_start@@Base+0x265f4> │ │ │ │ + bleq 8162c <__bss_start@@Base+0x26624> │ │ │ │ addvs r4, sl, r3, lsl #11 │ │ │ │ mrshi pc, LR_mon @ │ │ │ │ vstmiaeq fp, {s28-s106} │ │ │ │ ldrmi lr, [r4], -r3, ror #12 │ │ │ │ stmib r3, {r2, r5, r7, r9, sl, sp, lr, pc}^ │ │ │ │ ldrmi lr, [lr], -r2 │ │ │ │ andcc pc, ip, lr, asr #17 │ │ │ │ @@ -1843,19 +1843,19 @@ │ │ │ │ andhi pc, r3, r1, asr r8 @ │ │ │ │ ldrdge pc, [r8], -r0 │ │ │ │ mcrcs 6, 0, r4, cr0, cr6, {2} │ │ │ │ @ instruction: 0xf9b8d05e │ │ │ │ addsmi r4, r4, #0 │ │ │ │ stclle 0, cr13, [fp, #-80]! @ 0xffffffb0 │ │ │ │ stmiahi r8!, {r0, r1, r4, r6, r7, r8, fp, ip} │ │ │ │ - ble 1d95d5c <__bss_end__@@Base+0x1cef124> │ │ │ │ - beq c0180 <__bss_end__@@Base+0x19548> │ │ │ │ + ble 1d95cf4 <__bss_end__@@Base+0x1cef154> │ │ │ │ + beq c0118 <__bss_end__@@Base+0x19578> │ │ │ │ cdpne 0, 6, cr9, cr3, cr0, {0} │ │ │ │ ldrbmi r9, [r9], -r3, lsl #16 │ │ │ │ - blx 1cc32f8 <__bss_end__@@Base+0x1c1c6c0> │ │ │ │ + blx 1cc3290 <__bss_end__@@Base+0x1c1c6f0> │ │ │ │ @ instruction: 0x070aebb7 │ │ │ │ @ instruction: 0x4622d071 │ │ │ │ @ instruction: 0x4000f9b8 │ │ │ │ @ instruction: 0xd1ea4294 │ │ │ │ @ instruction: 0x3002f8b8 │ │ │ │ @ instruction: 0xc004f8b8 │ │ │ │ ldrmi r8, [r8], -r9, lsr #17 │ │ │ │ @@ -1871,35 +1871,35 @@ │ │ │ │ ldrtmi r3, [ip], #-1286 @ 0xfffffafa │ │ │ │ @ instruction: 0xf8a81bdb │ │ │ │ @ instruction: 0xf1094000 │ │ │ │ @ instruction: 0xf8a839ff │ │ │ │ @ instruction: 0xf9b53002 │ │ │ │ stmdahi pc!, {sp}^ @ │ │ │ │ svceq 0x0000f1b9 │ │ │ │ - blls f9a50 <__bss_end__@@Base+0x52e18> │ │ │ │ + blls f99e8 <__bss_end__@@Base+0x52e48> │ │ │ │ ldrdeq lr, [ip, -r3] │ │ │ │ @ instruction: 0xf10b689e │ │ │ │ ldrmi r0, [r3, #2817]! @ 0xb01 │ │ │ │ @ instruction: 0xf8dddba1 │ │ │ │ cdpcs 0, 0, cr10, cr0, cr12, {0} │ │ │ │ stmib sl, {r2, r9, sl, ip, pc}^ │ │ │ │ @ instruction: 0xf77f100c │ │ │ │ ldmib sl, {r1, r3, r5, r8, r9, sl, fp, sp, pc}^ │ │ │ │ andcs r2, r0, lr, lsl #6 │ │ │ │ - bl 93f94 <__bss_start@@Base+0x38ef4> │ │ │ │ + bl 93f2c <__bss_start@@Base+0x38f24> │ │ │ │ addvs r0, r8, r6, lsl #9 │ │ │ │ @ instruction: 0xf842310c │ │ │ │ @ instruction: 0xf8430b04 │ │ │ │ adcmi r0, r2, #4, 30 │ │ │ │ @ instruction: 0xe71ad1f7 │ │ │ │ stmiahi ip!, {r0, r1, r4, r6, r7, r8, fp, ip} │ │ │ │ - blcc 6b3ac <__bss_start@@Base+0x1030c> │ │ │ │ + blcc 6b344 <__bss_start@@Base+0x1033c> │ │ │ │ strls r4, [r0], #-1625 @ 0xfffff9a7 │ │ │ │ ldmibcc pc!, {r0, r3, r8, ip, sp, lr, pc}^ @ │ │ │ │ - blx 6c33a8 <__bss_end__@@Base+0x61c770> │ │ │ │ + blx 6c3340 <__bss_end__@@Base+0x61c7a0> │ │ │ │ @ instruction: 0xf9b53506 │ │ │ │ stmdahi pc!, {sp}^ @ │ │ │ │ svceq 0x0000f1b9 │ │ │ │ strb sp, [lr, sp, lsl #3] │ │ │ │ @ instruction: 0x3002f8b8 │ │ │ │ addsmi r1, r1, #409600 @ 0x64000 │ │ │ │ @ instruction: 0xf04fdc1a │ │ │ │ @@ -1916,15 +1916,15 @@ │ │ │ │ @ instruction: 0xf1b93506 │ │ │ │ @ instruction: 0xf47f0f00 │ │ │ │ str sl, [lr, lr, ror #30]! │ │ │ │ addlt r1, r9, #17408 @ 0x4400 │ │ │ │ strtmi r1, [r1], #-2651 @ 0xfffff5a5 │ │ │ │ andne pc, r0, r8, lsr #17 │ │ │ │ @ instruction: 0xf8a8b29b │ │ │ │ - blcs 11418 │ │ │ │ + blcs 113b0 │ │ │ │ svcge 0x0063f47f │ │ │ │ strmi lr, [ip, #2013] @ 0x7dd │ │ │ │ ldmibne r3, {r1, r2, ip, lr, pc}^ │ │ │ │ stmdals r3, {r8, ip, pc} │ │ │ │ ldrbmi r3, [r9], -r1, lsl #22 │ │ │ │ @ instruction: 0xf9dcf7ff │ │ │ │ ldmibcc pc!, {r0, r3, r8, ip, sp, lr, pc}^ @ │ │ │ │ @@ -1932,15 +1932,15 @@ │ │ │ │ @ instruction: 0xf108892f │ │ │ │ cdpcc 8, 0, cr0, cr1, cr6, {0} │ │ │ │ @ instruction: 0xf1b93506 │ │ │ │ @ instruction: 0xf47f0f00 │ │ │ │ str sl, [sl, sl, asr #30] │ │ │ │ andle r4, sl, ip, lsl #11 │ │ │ │ stmdals r3, {r0, r1, r4, sl, lr} │ │ │ │ - blcc 69850 <__bss_start@@Base+0xe7b0> │ │ │ │ + blcc 697e8 <__bss_start@@Base+0xe7e0> │ │ │ │ andls r4, r4, #93323264 @ 0x5900000 │ │ │ │ @ instruction: 0xf9c4f7ff │ │ │ │ @ instruction: 0x0002f8b8 │ │ │ │ strmi r9, [r2], #-2564 @ 0xfffff5fc │ │ │ │ @ instruction: 0xf1081a3f │ │ │ │ cdpcc 8, 0, cr0, cr1, cr6, {0} │ │ │ │ @ instruction: 0xf43fe735 │ │ │ │ @@ -1948,45 +1948,45 @@ │ │ │ │ andhi pc, r3, r1, asr r8 @ │ │ │ │ ldrdge pc, [r8], -r0 │ │ │ │ @ instruction: 0xe72c4656 │ │ │ │ @ instruction: 0xf8ca2201 │ │ │ │ @ instruction: 0xf8ca3064 │ │ │ │ strt r2, [ip], ip, asr #32 │ │ │ │ ldrdge pc, [ip], -sp │ │ │ │ - blmi 37f0a0 <__bss_end__@@Base+0x2d8468> │ │ │ │ + blmi 37f038 <__bss_end__@@Base+0x2d8498> │ │ │ │ sbcsvc pc, r3, #1325400064 @ 0x4f000000 │ │ │ │ stmdami sp, {r2, r3, r8, fp, lr} │ │ │ │ ldrbtmi r4, [r9], #-1147 @ 0xfffffb85 │ │ │ │ ldrbtmi r3, [r8], #-784 @ 0xfffffcf0 │ │ │ │ - mcr 7, 1, pc, cr8, cr13, {7} @ │ │ │ │ + mrc 7, 1, APSR_nzcv, cr6, cr13, {7} │ │ │ │ str r4, [r3, #1556]! @ 0x614 │ │ │ │ ldrbmi r9, [fp], -r4, lsl #18 │ │ │ │ smlabteq r0, sp, r9, lr │ │ │ │ msrcc SP_usr, r0 │ │ │ │ stmdami r7, {r1, r2, r9, fp, lr} │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - @ instruction: 0xf9b4f00d │ │ │ │ - stcl 7, cr15, [r2, #-1012] @ 0xfffffc0c │ │ │ │ - ldrdeq r7, [r4], -r8 │ │ │ │ - muleq r4, r2, r4 │ │ │ │ - andeq r4, r4, r2, ror r5 │ │ │ │ - andeq r4, r4, r4, lsr r5 │ │ │ │ - andeq r4, r4, r2, ror r4 │ │ │ │ + stc2 0, cr15, [r0, #52]! @ 0x34 │ │ │ │ + stcl 7, cr15, [lr, #-1012] @ 0xfffffc0c │ │ │ │ + andeq r8, r4, r4, ror #1 │ │ │ │ + andeq r4, r4, sl, ror r4 │ │ │ │ + andeq r4, r4, sl, asr r5 │ │ │ │ + andeq r4, r4, ip, lsl r5 │ │ │ │ + andeq r4, r4, sl, asr r4 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ andeq pc, r0, ip, asr #17 │ │ │ │ stcpl 5, cr15, [r0], {172} @ 0xac │ │ │ │ rsbseq pc, r8, ip, asr #17 │ │ │ │ ldrpl pc, [r0, #-2271]! @ 0xfffff721 │ │ │ │ ldclpl 5, cr15, [fp, #692]! @ 0x2b4 │ │ │ │ strmi pc, [ip, #-2271]! @ 0xfffff721 │ │ │ │ ldrbtmi fp, [sp], #-129 @ 0xffffff7f │ │ │ │ ldrbtpl pc, [sl], sp, lsl #10 @ │ │ │ │ - bcs 92d78 <__bss_start@@Base+0x37cd8> │ │ │ │ + bcs 92d10 <__bss_start@@Base+0x37d08> │ │ │ │ stmdavs r4!, {r2, r3, r5, r8, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f6034 │ │ │ │ movwls r0, #13312 @ 0x3400 │ │ │ │ @ instruction: 0x81b6f340 │ │ │ │ svcvc 0x007af5b2 │ │ │ │ rsbshi pc, r7, #0, 6 │ │ │ │ addmi pc, r0, #-2147483648 @ 0x80000000 │ │ │ │ @@ -2013,47 +2013,47 @@ │ │ │ │ eoreq pc, r1, r9, asr #16 │ │ │ │ movwcc r4, #17961 @ 0x4629 │ │ │ │ stceq 1, cr15, [r4], {12} │ │ │ │ eorsle r4, lr, r3, asr #10 │ │ │ │ @ instruction: 0xf93c4670 │ │ │ │ ldrmi r2, [lr], r2, lsl #24 │ │ │ │ mvnle r2, r0, lsl #30 │ │ │ │ - blle ffc95fe4 <__bss_end__@@Base+0xffbef3ac> │ │ │ │ + blle ffc95f7c <__bss_end__@@Base+0xffbef3dc> │ │ │ │ eormi pc, r1, r9, lsr #16 │ │ │ │ strcs r3, [r1, -r4, lsl #6] │ │ │ │ stceq 1, cr15, [r4], {12} │ │ │ │ @ instruction: 0x5000f9b0 │ │ │ │ @ instruction: 0x0002f9b0 │ │ │ │ - blne 194c2f4 <__bss_end__@@Base+0x18a56bc> │ │ │ │ - bcs fe440dcc <__bss_end__@@Base+0xfe39a194> │ │ │ │ - bpl fe440dcc <__bss_end__@@Base+0xfe39a194> │ │ │ │ + blne 194c28c <__bss_end__@@Base+0x18a56ec> │ │ │ │ + bcs fe440d64 <__bss_end__@@Base+0xfe39a1c4> │ │ │ │ + bpl fe440d64 <__bss_end__@@Base+0xfe39a1c4> │ │ │ │ @ instruction: 0x2c02f933 │ │ │ │ streq lr, [r1, #2825] @ 0xb09 │ │ │ │ - blpl ff9c10a0 <__bss_end__@@Base+0xff91a468> │ │ │ │ - blvc ffa010a4 <__bss_end__@@Base+0xff95a46c> │ │ │ │ + blpl ff9c1038 <__bss_end__@@Base+0xff91a498> │ │ │ │ + blvc ffa0103c <__bss_end__@@Base+0xff95a49c> │ │ │ │ @ instruction: 0xee061a12 │ │ │ │ @ instruction: 0xf85c0a90 │ │ │ │ strbmi r0, [r3, #-3078] @ 0xfffff3fa │ │ │ │ - blvs ff9c10b4 <__bss_end__@@Base+0xff91a47c> │ │ │ │ - blcc 200fec <__bss_end__@@Base+0x15a3b4> │ │ │ │ - bcs 440df0 <__bss_end__@@Base+0x39a1b8> │ │ │ │ + blvs ff9c104c <__bss_end__@@Base+0xff91a4ac> │ │ │ │ + blcc 200f84 <__bss_end__@@Base+0x15a3e4> │ │ │ │ + bcs 440d88 <__bss_end__@@Base+0x39a1e8> │ │ │ │ andeq pc, r1, #1073741824 @ 0x40000000 │ │ │ │ tstpeq r2, r1, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - blpl ff1810c8 <__bss_end__@@Base+0xff0da490> │ │ │ │ - blvs 180df8 <__bss_end__@@Base+0xda1c0> │ │ │ │ - blvc 140ec8 <__bss_end__@@Base+0x9a290> │ │ │ │ - blvc ff2010e8 <__bss_end__@@Base+0xff15a4b0> │ │ │ │ - bge 440e54 <__bss_end__@@Base+0x39a21c> │ │ │ │ + blpl ff181060 <__bss_end__@@Base+0xff0da4c0> │ │ │ │ + blvs 180d90 <__bss_end__@@Base+0xda1f0> │ │ │ │ + blvc 140e60 <__bss_end__@@Base+0x9a2c0> │ │ │ │ + blvc ff201080 <__bss_end__@@Base+0xff15a4e0> │ │ │ │ + bge 440dec <__bss_end__@@Base+0x39a24c> │ │ │ │ andge pc, r2, r5, lsr #17 │ │ │ │ eoreq pc, r2, r9, asr #16 │ │ │ │ stcls 1, cr13, [r1, #-768] @ 0xfffffd00 │ │ │ │ vmls.i8 d18, d0, d2 │ │ │ │ stmdbcc r1, {r0, r2, r3, r4, r5, r8, pc} │ │ │ │ cmnpvs r6, #54525952 @ p-variant is OBSOLETE @ 0x3400000 │ │ │ │ - blge 1ea218 <__bss_end__@@Base+0x1435e0> │ │ │ │ + blge 1ea1b0 <__bss_end__@@Base+0x143610> │ │ │ │ ldreq pc, [lr], #-269 @ 0xfffffef3 │ │ │ │ strtmi r2, [r4], r0, lsl #4 │ │ │ │ ldmvc ip!, {r0, r2, r3, r9, sl, ip, sp, lr, pc} │ │ │ │ eor pc, r1, r3, lsr r9 @ │ │ │ │ setend le │ │ │ │ ldrtmi r0, [r2], r4, lsl #18 │ │ │ │ ldrmi r4, [r9], #-1454 @ 0xfffffa52 │ │ │ │ @@ -2074,93 +2074,93 @@ │ │ │ │ @ instruction: 0x0c02f93c │ │ │ │ svccs 0x00004619 │ │ │ │ addmi sp, r5, #-2147483590 @ 0x8000003a │ │ │ │ @ instruction: 0xf9b6dcf2 │ │ │ │ movwcc r7, #16384 @ 0x4000 │ │ │ │ @ instruction: 0x6002f9b6 │ │ │ │ stceq 1, cr15, [r4], {12} │ │ │ │ - blne ffbcc588 <__bss_end__@@Base+0xffb25950> │ │ │ │ - beq fe440ea8 <__bss_end__@@Base+0xfe39a270> │ │ │ │ - bvc fe440ea8 <__bss_end__@@Base+0xfe39a270> │ │ │ │ + blne ffbcc520 <__bss_end__@@Base+0xffb25980> │ │ │ │ + beq fe440e40 <__bss_end__@@Base+0xfe39a2a0> │ │ │ │ + bvc fe440e40 <__bss_end__@@Base+0xfe39a2a0> │ │ │ │ @ instruction: 0x0c02f933 │ │ │ │ cdp 7, 11, cr2, cr8, cr1, {0} │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ - blne fe01c638 <__bss_end__@@Base+0xfdf75a00> │ │ │ │ - bvs fe440ebc <__bss_end__@@Base+0xfe39a284> │ │ │ │ + blne fe01c5d0 <__bss_end__@@Base+0xfdf75a30> │ │ │ │ + bvs fe440e54 <__bss_end__@@Base+0xfe39a2b4> │ │ │ │ streq lr, [r2], r8, lsl #22 │ │ │ │ eorpl pc, r2, r8, lsr #16 │ │ │ │ - blvs ff9c1190 <__bss_end__@@Base+0xff91a558> │ │ │ │ + blvs ff9c1128 <__bss_end__@@Base+0xff91a588> │ │ │ │ mcr 5, 4, r4, cr5, cr9, {4} │ │ │ │ vmla.f64 d3, d7, d7 │ │ │ │ @ instruction: 0xf1020a90 │ │ │ │ cps #1 │ │ │ │ cdp 2, 11, cr0, cr8, cr2, {0} │ │ │ │ vmls.f64 d5, d19, d23 │ │ │ │ vadd.f64 d6, d6, d5 │ │ │ │ vmov.f64 d7, #212 @ 0xbea00000 -0.3125000 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ rsbshi r4, r4, r0, lsl sl │ │ │ │ stcmi 8, cr15, [r6], {92} @ 0x5c │ │ │ │ eormi pc, r0, r8, asr #16 │ │ │ │ ldrbmi sp, [r6], -r1, asr #3 │ │ │ │ @ instruction: 0xf8dd9c04 │ │ │ │ - bcs ad70c <__bss_end__@@Base+0x6ad4> │ │ │ │ + bcs ad6a4 <__bss_end__@@Base+0x6b04> │ │ │ │ sbchi pc, sl, r0, asr #6 │ │ │ │ @ instruction: 0xf60d1e53 │ │ │ │ stcls 12, cr7, [r1, #-752] @ 0xfffffd10 │ │ │ │ adcsvc pc, lr, sp, lsl #12 │ │ │ │ andcs r0, r0, #155 @ 0x9b │ │ │ │ streq lr, [r3, -ip, lsl #22] │ │ │ │ strmi r3, [r3], #-772 @ 0xfffffcfc │ │ │ │ cdpvc 6, 4, cr15, cr4, cr5, {5} │ │ │ │ - blmi 411e8 │ │ │ │ + blmi 41180 │ │ │ │ @ instruction: 0x1002f9b7 │ │ │ │ svclt 0x00cc42b1 │ │ │ │ mrscs r2, (UNDEF: 17) │ │ │ │ @ instruction: 0xf102e00c │ │ │ │ adcmi r0, lr, #65536 @ 0x10000 │ │ │ │ tstphi r8, r0, asr #5 @ p-variant is OBSOLETE │ │ │ │ stcpl 8, cr15, [r2], {80} @ 0x50 │ │ │ │ eorpl pc, r2, lr, asr #16 │ │ │ │ andcc r4, r4, r2, asr #12 │ │ │ │ eorsle r4, sp, r3, lsl #5 │ │ │ │ @ instruction: 0x460746b9 │ │ │ │ stmdbpl r2, {r0, r1, r2, r4, r5, r8, fp, ip, sp, lr, pc} │ │ │ │ mvnle r2, r0, lsl #18 │ │ │ │ - blle ffd16200 <__bss_end__@@Base+0xffc6f5c8> │ │ │ │ + blle ffd16198 <__bss_end__@@Base+0xffc6f5f8> │ │ │ │ @ instruction: 0x1002f9b9 │ │ │ │ @ instruction: 0xf9b93004 │ │ │ │ - bne 1b65754 <__bss_end__@@Base+0x1abeb1c> │ │ │ │ + bne 1b656ec <__bss_end__@@Base+0x1abeb4c> │ │ │ │ @ instruction: 0xee071a71 │ │ │ │ vmov s13, r5 │ │ │ │ @ instruction: 0xf9301a90 │ │ │ │ cdp 12, 11, cr1, cr8, cr6, {0} │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ - bl fe85c704 <__bss_end__@@Base+0xfe7b5acc> │ │ │ │ + bl fe85c69c <__bss_end__@@Base+0xfe7b5afc> │ │ │ │ cdp 1, 0, cr0, cr6, cr8, {0} │ │ │ │ @ instruction: 0xf1028a90 │ │ │ │ @ instruction: 0xf8500801 │ │ │ │ cdp 12, 11, cr5, cr8, cr6, {0} │ │ │ │ addmi r6, r3, #235520 @ 0x39800 │ │ │ │ - blcc 201198 <__bss_end__@@Base+0x15a560> │ │ │ │ - bne fe440fa4 <__bss_end__@@Base+0xfe39a36c> │ │ │ │ + blcc 201130 <__bss_end__@@Base+0x15a590> │ │ │ │ + bne fe440f3c <__bss_end__@@Base+0xfe39a39c> │ │ │ │ orreq lr, r2, lr, lsl #22 │ │ │ │ - blpl ffa01270 <__bss_end__@@Base+0xff95a638> │ │ │ │ + blpl ffa01208 <__bss_end__@@Base+0xff95a668> │ │ │ │ @ instruction: 0xf04f804e │ │ │ │ cdp 1, 0, cr0, cr3, cr1, {0} │ │ │ │ vadd.f64 d6, d6, d5 │ │ │ │ vmov.f64 d7, #212 @ 0xbea00000 -0.3125000 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ @ instruction: 0xf82e9a10 │ │ │ │ @ instruction: 0xf1029022 │ │ │ │ @ instruction: 0xf84e0202 │ │ │ │ bicle r5, r1, r8, lsr #32 │ │ │ │ vstmdble r5!, {s5-s6} │ │ │ │ - bls 4d108 │ │ │ │ - blmi 41298 │ │ │ │ + bls 4d0a0 │ │ │ │ + blmi 41230 │ │ │ │ @ instruction: 0xf6a2009b │ │ │ │ ldrmi r7, [sl], #-580 @ 0xfffffdbc │ │ │ │ @ instruction: 0x0002f9b2 │ │ │ │ ldrbmi r9, [r0, #-2565] @ 0xfffff5fb │ │ │ │ streq lr, [r3, #-2818] @ 0xfffff4fe │ │ │ │ @ instruction: 0x2000bfb8 │ │ │ │ svclt 0x00a8462b │ │ │ │ @@ -2174,177 +2174,177 @@ │ │ │ │ eorsle r4, ip, r5, lsr #5 │ │ │ │ @ instruction: 0x4623461e │ │ │ │ stmdbne r2, {r0, r1, r4, r5, r8, fp, ip, sp, lr, pc} │ │ │ │ mvnle r2, r0, lsl #16 │ │ │ │ ldclle 5, cr4, [r4], #552 @ 0x228 │ │ │ │ @ instruction: 0x0002f9b6 │ │ │ │ @ instruction: 0xf9b63404 │ │ │ │ - bne 25d818 <__bss_end__@@Base+0x1b6be0> │ │ │ │ + bne 25d7b0 <__bss_end__@@Base+0x1b6c10> │ │ │ │ andeq lr, r0, sl, lsr #23 │ │ │ │ - bne fe44103c <__bss_end__@@Base+0xfe39a404> │ │ │ │ - beq fe44103c <__bss_end__@@Base+0xfe39a404> │ │ │ │ + bne fe440fd4 <__bss_end__@@Base+0xfe39a434> │ │ │ │ + beq fe440fd4 <__bss_end__@@Base+0xfe39a434> │ │ │ │ @ instruction: 0x1c06f934 │ │ │ │ cdp 0, 11, cr2, cr8, cr1, {0} │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ - blne fe25c7cc <__bss_end__@@Base+0xfe1b5b94> │ │ │ │ - bvs fe441050 <__bss_end__@@Base+0xfe39a418> │ │ │ │ + blne fe25c764 <__bss_end__@@Base+0xfe1b5bc4> │ │ │ │ + bvs fe440fe8 <__bss_end__@@Base+0xfe39a448> │ │ │ │ mrc 12, 5, r1, cr8, cr6, {2} │ │ │ │ @ instruction: 0xee856be6 │ │ │ │ vmla.f64 d3, d7, d7 │ │ │ │ - bl 30c288 <__bss_end__@@Base+0x265650> │ │ │ │ + bl 30c220 <__bss_end__@@Base+0x265680> │ │ │ │ cdp 1, 11, cr0, cr8, cr2, {4} │ │ │ │ @ instruction: 0xf8a15be7 │ │ │ │ @ instruction: 0xf854a002 │ │ │ │ adcmi r1, r5, #1536 @ 0x600 │ │ │ │ - blvs 181068 <__bss_end__@@Base+0xda430> │ │ │ │ - blvc 141138 <__bss_end__@@Base+0x9a500> │ │ │ │ - blvc ff201358 <__bss_end__@@Base+0xff15a720> │ │ │ │ - bvc 4410c4 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0xbea00000 -0.3125000 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ @ instruction: 0xf82c1a10 │ │ │ │ ldrtmi r1, [sl], -r2, lsr #32 │ │ │ │ @ instruction: 0xf7fde6f5 │ │ │ │ - bmi 240d70 <__bss_end__@@Base+0x19a138> │ │ │ │ + bmi 240d48 <__bss_end__@@Base+0x19a1a8> │ │ │ │ stmdami r8, {r8, r9, sp} │ │ │ │ cmnppl r4, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - @ instruction: 0xff04f00c │ │ │ │ - b fe4c3a18 <__bss_end__@@Base+0xfe41cde0> │ │ │ │ - andeq r2, r5, r2, lsl #22 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r2, r5, r2, ror r7 │ │ │ │ - andeq r4, r4, r0, lsl r0 │ │ │ │ - andeq r3, r4, r2, lsl pc │ │ │ │ + blx ffc419ec <__bss_end__@@Base+0xffb9ae4c> │ │ │ │ + b fe7c39b0 <__bss_end__@@Base+0xfe71ce10> │ │ │ │ + andeq r2, r5, sl, ror #22 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + ldrdeq r2, [r5], -sl │ │ │ │ + strdeq r3, [r4], -r8 │ │ │ │ + strdeq r3, [r4], -sl │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5cc40 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[pc, #-878] @ 576a │ │ │ │ strtmi r9, [r5], -r1, lsl #10 │ │ │ │ - streq pc, [pc], #-866 @ 5b48 │ │ │ │ + streq pc, [pc], #-866 @ 5ae0 │ │ │ │ vhsub.u32 d18, d12, d4 │ │ │ │ vrshl.u32 d16, d15, d1 │ │ │ │ strls r4, [r3], #-1055 @ 0xfffffbe1 │ │ │ │ - ldrmi pc, [pc, #-865] @ 57f7 │ │ │ │ + ldrmi pc, [pc, #-865] @ 578f │ │ │ │ strls r4, [r2, #-1641] @ 0xfffff997 │ │ │ │ stc2 7, cr15, [r4, #1016]! @ 0x3f8 │ │ │ │ @ instruction: 0xf7fde7d1 │ │ │ │ - svclt 0x0000ec2c │ │ │ │ + svclt 0x0000ec3c │ │ │ │ + andeq r2, r5, r6, asr #11 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ andeq r2, r5, lr, asr r5 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - strdeq r2, [r5], -r6 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb5cd7c <__bss_end__@@Base+0xfeab6144> │ │ │ │ + bl feb5cd14 <__bss_end__@@Base+0xfeab6174> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf9b10ff0 │ │ │ │ @ instruction: 0xf9b14000 │ │ │ │ ldrbmi lr, [r4, #-4]! │ │ │ │ @ instruction: 0xf9b1da1b │ │ │ │ @ instruction: 0xf9b14002 │ │ │ │ addsmi r3, ip, #6 │ │ │ │ ldmib r0, {r0, r2, r4, r9, fp, ip, lr, pc}^ │ │ │ │ adcmi r4, r3, #28, 6 @ 0x70000000 │ │ │ │ @ instruction: 0x6ec5da12 │ │ │ │ vmlsne.f32 s28, s6, s30 │ │ │ │ strbvs r3, [r3, -r1, lsl #6] │ │ │ │ streq lr, [lr], #-2821 @ 0xfffff4fb │ │ │ │ - blcc 615c0 <__bss_start@@Base+0x6520> │ │ │ │ + blcc 61558 <__bss_start@@Base+0x6550> │ │ │ │ rsbvs r6, r3, r3, lsl #13 │ │ │ │ andcs pc, lr, r5, lsr #16 │ │ │ │ pop {r1, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7ff4038 │ │ │ │ ldclt 15, cr11, [r8, #-396]! @ 0xfffffe74 │ │ │ │ movwcs r4, #2565 @ 0xa05 │ │ │ │ vadd.i8 d20, d0, d5 │ │ │ │ ldrbtmi r4, [sl], #-331 @ 0xfffffeb5 │ │ │ │ - @ instruction: 0xf00c4478 │ │ │ │ - @ instruction: 0xf7fdfe27 │ │ │ │ - svclt 0x0000e9b6 │ │ │ │ - strdeq r3, [r4], -lr │ │ │ │ - andeq r3, r4, r8, asr sp │ │ │ │ + @ instruction: 0xf00d4478 │ │ │ │ + @ instruction: 0xf7fdfa13 │ │ │ │ + svclt 0x0000e9c2 │ │ │ │ + andeq r3, r4, r6, ror #27 │ │ │ │ + andeq r3, r4, r0, asr #26 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│ │ adcsmi r9, fp, #2048 @ 0x800 │ │ │ │ svclt 0x00d49b00 │ │ │ │ strcs r2, [r1], -r0, lsl #12 │ │ │ │ - b 13d6718 <__bss_end__@@Base+0x132fae0> │ │ │ │ - blle a875c4 <__bss_end__@@Base+0x9e098c> │ │ │ │ + b 13d66b0 <__bss_end__@@Base+0x132fb10> │ │ │ │ + blle a8755c <__bss_end__@@Base+0x9e09bc> │ │ │ │ streq pc, [r4], -r6, asr #32 │ │ │ │ @ instruction: 0x46a3463a │ │ │ │ @ instruction: 0xd12d422e │ │ │ │ andeq lr, r9, fp, lsr #23 │ │ │ │ streq lr, [r8], #-2978 @ 0xfffff45e │ │ │ │ sbcsle r2, ip, r0, lsl #26 │ │ │ │ svclt 0x005807eb │ │ │ │ @ instruction: 0xf10046aa │ │ │ │ @ instruction: 0xf01a80a4 │ │ │ │ andls r0, r5, #2, 30 │ │ │ │ svcls 0x0002d030 │ │ │ │ - bl fe9d7560 <__bss_end__@@Base+0xfe930928> │ │ │ │ - blx 106d02 <__bss_end__@@Base+0x600ca> │ │ │ │ + bl fe9d74f8 <__bss_end__@@Base+0xfe930958> │ │ │ │ + blx 106c9a <__bss_end__@@Base+0x600fa> │ │ │ │ @ instruction: 0xf043f000 │ │ │ │ - bls 184474 <__bss_end__@@Base+0xdd83c> │ │ │ │ + bls 1843ec <__bss_end__@@Base+0xdd84c> │ │ │ │ streq lr, [r9], #-2816 @ 0xfffff500 │ │ │ │ ldrbmi r9, [r5, #-2820] @ 0xfffff4fc │ │ │ │ adcshi pc, r7, r0 │ │ │ │ svclt 0x00a8429f │ │ │ │ - blle ff34f500 <__bss_end__@@Base+0xff2a88c8> │ │ │ │ + blle ff34f498 <__bss_end__@@Base+0xff2a88f8> │ │ │ │ addsmi r9, ip, #0, 22 │ │ │ │ - blls 7c854 <__bss_start@@Base+0x217b4> │ │ │ │ - ble e16778 <__bss_end__@@Base+0xd6fb40> │ │ │ │ + blls 7c7ec <__bss_start@@Base+0x217e4> │ │ │ │ + ble e16710 <__bss_end__@@Base+0xd6fb70> │ │ │ │ streq pc, [r8], -r6, asr #32 │ │ │ │ @ instruction: 0x46a3463a │ │ │ │ sbcsle r4, r1, lr, lsr #4 │ │ │ │ pop {r0, r1, r3, ip, sp, pc} │ │ │ │ ldrbmi r8, [ip, #4080] @ 0xff0 │ │ │ │ @ instruction: 0x2600bfd4 │ │ │ │ ldrbmi r2, [r1, #-1537] @ 0xfffff9ff │ │ │ │ strbeq lr, [r6], -pc, asr #20 │ │ │ │ stmdals r1, {r1, r2, r4, r7, r8, sl, fp, ip, lr, pc} │ │ │ │ vqrshl.u8 q10, q0, q0 │ │ │ │ @ instruction: 0xf04680e8 │ │ │ │ ldr r0, [r1, r8, lsl #12] │ │ │ │ @ instruction: 0xf01a4601 │ │ │ │ @ instruction: 0xf0000f04 │ │ │ │ - blls 225f98 <__bss_end__@@Base+0x17f360> │ │ │ │ + blls 225f30 <__bss_end__@@Base+0x17f390> │ │ │ │ andeq lr, r9, r3, lsr #23 │ │ │ │ @ instruction: 0xf000fb04 │ │ │ │ @ instruction: 0xf043461c │ │ │ │ - blls 144408 <__bss_end__@@Base+0x9d7d0> │ │ │ │ - bl 2c56c │ │ │ │ + blls 144380 <__bss_end__@@Base+0x9d7e0> │ │ │ │ + bl 2c504 │ │ │ │ ldrbmi r0, [r5, #-1800] @ 0xfffff8f8 │ │ │ │ addsmi sp, pc, #117 @ 0x75 │ │ │ │ strcs fp, [r1], -r8, lsr #31 │ │ │ │ - blls bc89c <__bss_end__@@Base+0x15c64> │ │ │ │ - blls 567e8 │ │ │ │ + blls bc834 <__bss_end__@@Base+0x15c94> │ │ │ │ + blls 56780 │ │ │ │ strcs fp, [r0], -ip, lsr #31 │ │ │ │ addsmi r2, ip, #1048576 @ 0x100000 │ │ │ │ strbeq lr, [r6], -pc, asr #20 │ │ │ │ - b 15bcc94 <__bss_end__@@Base+0x151605c> │ │ │ │ + b 15bcc2c <__bss_end__@@Base+0x151608c> │ │ │ │ @ instruction: 0xf0400305 │ │ │ │ ldmib sp, {r0, r3, r7, pc}^ │ │ │ │ ldrmi r2, [r8, #774]! @ 0x306 │ │ │ │ addhi pc, r7, r0, lsl #6 │ │ │ │ tstcs r1, ip, lsl #30 │ │ │ │ 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instruction: 0xf8c2bfc8 │ │ │ │ adcsmi r8, fp, #40 @ 0x28 │ │ │ │ sbcsvs fp, r7, #184, 30 @ 0x2e0 │ │ │ │ pop {r0, r1, r3, ip, sp, pc} │ │ │ │ @ instruction: 0x46b28ff0 │ │ │ │ svcls 0x0003e75b │ │ │ │ andls r4, r5, #34603008 @ 0x2100000 │ │ │ │ stmdaeq r8, {r0, r1, r2, r5, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf008fb00 │ │ │ │ - @ instruction: 0xf942f043 │ │ │ │ - bl 2c640 │ │ │ │ - blls 86e54 <__bss_start@@Base+0x2bdb4> │ │ │ │ + @ instruction: 0xf93af043 │ │ │ │ + bl 2c5d8 │ │ │ │ + blls 86dec <__bss_start@@Base+0x2bde4> │ │ │ │ svclt 0x00d442bb │ │ │ │ strcs r2, [r1, #-1280] @ 0xfffffb00 │ │ │ │ - blls 5ff0 │ │ │ │ - blle 2168b0 <__bss_end__@@Base+0x16fc78> │ │ │ │ + blls 5f88 │ │ │ │ + blle 216848 <__bss_end__@@Base+0x16fca8> │ │ │ │ streq pc, [r4, #-69] @ 0xffffffbb │ │ │ │ ldrtmi r4, [r8], r1, lsr #13 │ │ │ │ addsmi lr, pc, #52, 14 @ 0xd00000 │ │ │ │ strcs fp, [r1, #-4008] @ 0xfffff058 │ │ │ │ - blls 7cbd0 <__bss_start@@Base+0x21b30> │ │ │ │ - ble 5568c8 <__bss_end__@@Base+0x4afc90> │ │ │ │ + blls 7cb68 <__bss_start@@Base+0x21b60> │ │ │ │ + ble 556860 <__bss_end__@@Base+0x4afcc0> │ │ │ │ streq pc, [r8, #-69] @ 0xffffffbb │ │ │ │ ldrtmi r4, [r8], r1, lsr #13 │ │ │ │ addsmi lr, pc, #40, 14 @ 0xa00000 │ │ │ │ strcs fp, [r1, #-4008] @ 0xfffff058 │ │ │ │ strb sp, [r0, r7, ror #21]! │ │ │ │ - bl fe8eca74 <__bss_end__@@Base+0xfe845e3c> │ │ │ │ - blx 105e9a <__bss_end__@@Base+0x5f262> │ │ │ │ + bl fe8eca0c <__bss_end__@@Base+0xfe845e6c> │ │ │ │ + blx 105e32 <__bss_end__@@Base+0x5f292> │ │ │ │ ldrmi pc, [ip], -r0 │ │ │ │ - @ instruction: 0xf918f043 │ │ │ │ - bl 2c694 │ │ │ │ + @ instruction: 0xf910f043 │ │ │ │ + bl 2c62c │ │ │ │ ldr r0, [r3, -r8, lsl #14]! │ │ │ │ @ instruction: 0x46a146b8 │ │ │ │ @ instruction: 0x465c4617 │ │ │ │ movweq lr, #23126 @ 0x5a56 │ │ │ │ svcge 0x0077f43f │ │ │ │ @ instruction: 0x46a3463a │ │ │ │ strbmi lr, [ip, #-1804] @ 0xfffff8f4 │ │ │ │ ldmib r2, {r0, r2, r3, r6, ip, lr, pc}^ │ │ │ │ movwls r0, #273 @ 0x111 │ │ │ │ addmi r1, r5, #52480 @ 0xcd00 │ │ │ │ ldrvs sp, [r5], #570 @ 0x23a │ │ │ │ - bl fea4f310 <__bss_end__@@Base+0xfe9a86d8> │ │ │ │ + bl fea4f2a8 <__bss_end__@@Base+0xfe9a8708> │ │ │ │ strteq r0, [r4], #-4 │ │ │ │ strmi pc, [r0], #-1284 @ 0xfffffafc │ │ │ │ - blx 16a6c2 <__bss_end__@@Base+0xc3a8a> │ │ │ │ + blx 16a65a <__bss_end__@@Base+0xc3aba> │ │ │ │ ldcvs 1, cr15, [r5], {1} │ │ │ │ @ instruction: 0xf8250400 │ │ │ │ strmi r8, [sp], #-1 │ │ │ │ smlatbeq r7, r8, fp, lr │ │ │ │ @ instruction: 0xf043606c │ │ │ │ - bls 84288 <__bss_start@@Base+0x291e8> │ │ │ │ + bls 84200 <__bss_start@@Base+0x291f8> │ │ │ │ strbmi r9, [r1], -r0, lsl #22 │ │ │ │ ldrtmi r6, [r8], fp, ror #7 │ │ │ │ rscvs r6, fp, fp, ror #4 │ │ │ │ ldrdvs r6, [r8], r3 @ │ │ │ │ eoreq pc, r7, r3, asr r8 @ │ │ │ │ @ instruction: 0xf8436128 │ │ │ │ strmi r5, [pc], -r7, lsr #32 │ │ │ │ stmdals r1, {r0, r1, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ strmi r2, [r2, #1537] @ 0x601 │ │ │ │ mrcge 6, 5, APSR_nzcv, cr0, cr15, {5} │ │ │ │ streq pc, [r8], -r6, asr #32 │ │ │ │ - b 15bf9b4 <__bss_end__@@Base+0x1518d7c> │ │ │ │ + b 15bf94c <__bss_end__@@Base+0x1518dac> │ │ │ │ svclt 0x00040005 │ │ │ │ @ instruction: 0x4654465f │ │ │ │ svcge 0x003bf43f │ │ │ │ - blls bf9a4 <__bss_end__@@Base+0x18d6c> │ │ │ │ + blls bf93c <__bss_end__@@Base+0x18d9c> │ │ │ │ svclt 0x00ac429f │ │ │ │ strcs r2, [r1, #-1280] @ 0xfffffb00 │ │ │ │ ldr r0, [r8, sp, rrx] │ │ │ │ andscs r4, r3, #12, 22 @ 0x3000 │ │ │ │ tstcs r1, r9, lsl #24 │ │ │ │ stmiapl r3!, {r0, r1, r3, fp, lr}^ │ │ │ │ ldmdavs fp, {r3, r4, r5, r6, sl, lr} │ │ │ │ pop {r0, r1, r3, ip, sp, pc} │ │ │ │ @ instruction: 0xf7fd4ff0 │ │ │ │ - strbmi fp, [r1], -r7, lsl #20 │ │ │ │ + @ instruction: 0x4641ba17 │ │ │ │ @ instruction: 0x460f46b8 │ │ │ │ ldrtmi lr, [r8], -lr, lsr #14 │ │ │ │ strbmi r4, [r7], -r1, lsr #12 │ │ │ │ strmi r4, [r0], ip, asr #12 │ │ │ │ str r4, [r6, r9, lsl #13]! │ │ │ │ - strdeq r2, [r5], -r6 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r3, r4, r8, lsl #20 │ │ │ │ + andeq r2, r5, lr, asr r4 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + strdeq r3, [r4], -r0 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00e0f8cc │ │ │ │ ldrmi r4, [r5], -r6, lsl #12 │ │ │ │ andseq lr, ip, #208, 18 @ 0x340000 │ │ │ │ addmi fp, r2, #130 @ 0x82 │ │ │ │ @ instruction: 0x6ef4da24 │ │ │ │ andcc r0, r1, #16, 2 │ │ │ │ - bl 11fd4c <__bss_end__@@Base+0x79114> │ │ │ │ + bl 11fce4 <__bss_end__@@Base+0x79144> │ │ │ │ cdpvs 8, 11, cr0, cr2, cr0, {0} │ │ │ │ @ instruction: 0xf1022d00 │ │ │ │ @ instruction: 0x66b232ff │ │ │ │ andcs pc, r4, r8, asr #17 │ │ │ │ ldcle 2, cr5, [r2, #-140] @ 0xffffff74 │ │ │ │ streq pc, [r8], #-257 @ 0xfffffeff │ │ │ │ @ instruction: 0x3c04f934 │ │ │ │ @@ -2669,153 +2669,153 @@ │ │ │ │ @ instruction: 0xf7ff9700 │ │ │ │ stccc 14, cr15, [r1, #-92] @ 0xffffffa4 │ │ │ │ andlt sp, r2, lr, ror #3 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ movwcs r4, #2565 @ 0xa05 │ │ │ │ vadd.i8 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instruction: 0xf828606c │ │ │ │ stmib sp, {r1, r2, r3, ip, sp, lr}^ │ │ │ │ pop {r1, r2, r8, sl, sp, lr} │ │ │ │ @ instruction: 0xf7ff41f0 │ │ │ │ - bmi 1757a8 <__bss_end__@@Base+0xceb70> │ │ │ │ + bmi 175740 <__bss_end__@@Base+0xceba0> │ │ │ │ stmdami r5, {r8, r9, sp} │ │ │ │ cmppmi fp, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - blx ffdc206e <__bss_end__@@Base+0xffd1b436> │ │ │ │ - svc 0x0084f7fc │ │ │ │ - muleq r4, ip, r9 │ │ │ │ - strdeq r3, [r4], -r6 │ │ │ │ + @ instruction: 0xffe2f00c │ │ │ │ + svc 0x0090f7fc │ │ │ │ + andeq r3, r4, r4, lsl #19 │ │ │ │ + ldrdeq r3, [r4], -lr │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 3c1508 <__bss_end__@@Base+0x31a8d0> │ │ │ │ + blhi 3c14a0 <__bss_end__@@Base+0x31a900> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0070f8cc │ │ │ │ addlt r4, sp, r4, lsl #12 │ │ │ │ ldmib r4, {r3, r4, r9, sl, lr}^ │ │ │ │ svcls 0x0025951c │ │ │ │ strbmi r9, [sp, #-2854] @ 0xfffff4da │ │ │ │ @ instruction: 0xa09cf8bd │ │ │ │ sbcshi pc, ip, r0, lsl #5 │ │ │ │ - bvc 9417ec <__bss_end__@@Base+0x89abb4> │ │ │ │ - beq 44189c <__bss_end__@@Base+0x39ac64> │ │ │ │ - bne 4418a4 <__bss_end__@@Base+0x39ac6c> │ │ │ │ - bcs 4418ac <__bss_end__@@Base+0x39ac74> │ │ │ │ - blhi ff241b68 <__bss_end__@@Base+0xff19af30> │ │ │ │ + bvc 941784 <__bss_end__@@Base+0x89abe4> │ │ │ │ + beq 441834 <__bss_end__@@Base+0x39ac94> │ │ │ │ + bne 44183c <__bss_end__@@Base+0x39ac9c> │ │ │ │ + bcs 441844 <__bss_end__@@Base+0x39aca4> │ │ │ │ + blhi ff241b00 <__bss_end__@@Base+0xff19af60> │ │ │ │ cdp 14, 11, cr6, cr8, cr0, {7} │ │ │ │ vrintz.f64 d11, d23 │ │ │ │ @ instruction: 0x01297b00 │ │ │ │ - blls ff281b78 <__bss_end__@@Base+0xff1daf40> │ │ │ │ - blge ff2c1b7c <__bss_end__@@Base+0xff21af44> │ │ │ │ + blls ff281b10 <__bss_end__@@Base+0xff1daf70> │ │ │ │ + blge ff2c1b14 <__bss_end__@@Base+0xff21af74> │ │ │ │ cdp 8, 2, cr1, cr8, cr6, {2} │ │ │ │ vfmavs.f64 d8, d2, d7 │ │ │ │ - bllt 201954 <__bss_end__@@Base+0x15ad1c> │ │ │ │ - bvc fe4418c8 <__bss_end__@@Base+0xfe39ac90> │ │ │ │ + bllt 2018ec <__bss_end__@@Base+0x15ad4c> │ │ │ │ + bvc fe441860 <__bss_end__@@Base+0xfe39acc0> │ │ │ │ strcc r3, [r1, #-2561] @ 0xfffff5ff │ │ │ │ cdp 6, 11, cr6, cr8, cr2, {5} │ │ │ │ strbvs r7, [r5, -r7, ror #23]! │ │ │ │ - blls 2419a0 <__bss_end__@@Base+0x19ad68> │ │ │ │ + blls 241938 <__bss_end__@@Base+0x19ad98> │ │ │ │ mrc 0, 1, r6, cr10, cr2, {3} │ │ │ │ - vldr d10, [pc, #44] @ 60f0 │ │ │ │ - blcs 20e48 │ │ │ │ - bleq 1841748 <__bss_end__@@Base+0x179ab10> │ │ │ │ + vldr d10, [pc, #44] @ 6088 │ │ │ │ + blcs 20de0 │ │ │ │ + bleq 18416e0 <__bss_end__@@Base+0x179ab40> │ │ │ │ @ instruction: 0xf8209607 │ │ │ │ vaddl.s8 q13, d0, d1 │ │ │ │ cdp 0, 2, cr8, cr7, cr1, {4} │ │ │ │ - bge 224cf4 <__bss_end__@@Base+0x17e0bc> │ │ │ │ + bge 224c8c <__bss_end__@@Base+0x17e0ec> │ │ │ │ svcmi 0x00b4f5b3 │ │ │ │ ldrmi sl, [r1], -sl, lsl #16 │ │ │ │ @ instruction: 0x9326461e │ │ │ │ @ instruction: 0xf44fbfa8 │ │ │ │ mcr 6, 4, r4, cr7, cr4, {5} │ │ │ │ andls r0, r5, r0, lsl #22 │ │ │ │ @ instruction: 0xf7fc9204 │ │ │ │ - vldr , [sp, #256] @ 0x100 │ │ │ │ + vldr , [sp, #312] @ 0x138 │ │ │ │ vmov.f64 d7, #8 @ 0x40400000 3.0 │ │ │ │ vldr d6, [sp, #292] @ 0x124 │ │ │ │ - blls 99cd30 <__bss_end__@@Base+0x8f60f8> │ │ │ │ - blvs 241928 <__bss_end__@@Base+0x19acf0> │ │ │ │ - blvc 12c1bd0 <__bss_end__@@Base+0x121af98> │ │ │ │ - blvc 1301928 <__bss_end__@@Base+0x125acf0> │ │ │ │ - blvs ff1c1d0c <__bss_end__@@Base+0xff11b0d4> │ │ │ │ - blvc ff201d10 <__bss_end__@@Base+0xff15b0d8> │ │ │ │ - bhi fe441978 <__bss_end__@@Base+0xfe39ad40> │ │ │ │ - blt fe441980 <__bss_end__@@Base+0xfe39ad48> │ │ │ │ + blls 99ccc8 <__bss_end__@@Base+0x8f6128> │ │ │ │ + blvs 2418c0 <__bss_end__@@Base+0x19ad20> │ │ │ │ + blvc 12c1b68 <__bss_end__@@Base+0x121afc8> │ │ │ │ + blvc 13018c0 <__bss_end__@@Base+0x125ad20> │ │ │ │ + blvs ff1c1ca4 <__bss_end__@@Base+0xff11b104> │ │ │ │ + blvc ff201ca8 <__bss_end__@@Base+0xff15b108> │ │ │ │ + bhi fe441910 <__bss_end__@@Base+0xfe39ad70> │ │ │ │ + blt fe441918 <__bss_end__@@Base+0xfe39ad78> │ │ │ │ subsle r2, r2, r0, lsl #22 │ │ │ │ mvnsvs pc, pc, asr #8 │ │ │ │ - blgt 11817ac <__bss_end__@@Base+0x10dab74> │ │ │ │ - blle 11c17b0 <__bss_end__@@Base+0x111ab78> │ │ │ │ + blgt 1181744 <__bss_end__@@Base+0x10daba4> │ │ │ │ + blle 11c1748 <__bss_end__@@Base+0x111aba8> │ │ │ │ and r9, r8, r6, lsl #2 │ │ │ │ vnmls.f64 d9, d14, d7 │ │ │ │ ldmib r4, {r4, r9, fp, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf8b3951c │ │ │ │ - blls ee148 <__bss_end__@@Base+0x47510> │ │ │ │ - blls 197bac <__bss_end__@@Base+0xf0f74> │ │ │ │ + blls ee0e0 <__bss_end__@@Base+0x47540> │ │ │ │ + blls 197b44 <__bss_end__@@Base+0xf0fa4> │ │ │ │ @ instruction: 0x66f0f5b6 │ │ │ │ @ instruction: 0xeeb09904 │ │ │ │ - ldrmi lr, [pc], #-2890 @ 6158 │ │ │ │ + ldrmi lr, [pc], #-2890 @ 60f0 │ │ │ │ svclt 0x00489805 │ │ │ │ vmov.16 d23[0], r1 │ │ │ │ svclt 0x00487a90 │ │ │ │ cdp 6, 11, cr2, cr8, cr0, {0} │ │ │ │ vnmul.f64 d0, d16, d23 │ │ │ │ vdiv.f64 d0, d0, d12 │ │ │ │ @ instruction: 0xf7fc0b0d │ │ │ │ - vldr , [sp, #8] │ │ │ │ + vldr , [sp, #64] @ 0x40 │ │ │ │ vmov.f64 d6, #8 @ 0x40400000 3.0 │ │ │ │ vldr d7, [sp, #292] @ 0x124 │ │ │ │ strbmi r5, [sp, #-2826] @ 0xfffff4f6 │ │ │ │ - blvc 2419a0 <__bss_end__@@Base+0x19ad68> │ │ │ │ - bl 13019a0 <__bss_end__@@Base+0x125ad68> │ │ │ │ - blvc ff201d84 <__bss_end__@@Base+0xff15b14c> │ │ │ │ - bl ff3c1c88 <__bss_end__@@Base+0xff31b050> │ │ │ │ - bcc fe4419f4 <__bss_end__@@Base+0xfe39adbc> │ │ │ │ + blvc 241938 <__bss_end__@@Base+0x19ad98> │ │ │ │ + bl 1301938 <__bss_end__@@Base+0x125ad98> │ │ │ │ + blvc ff201d1c <__bss_end__@@Base+0xff15b17c> │ │ │ │ + bl ff3c1c20 <__bss_end__@@Base+0xff31b080> │ │ │ │ + bcc fe44198c <__bss_end__@@Base+0xfe39adec> │ │ │ │ @ instruction: 0xf8d4da48 │ │ │ │ - b 13fe350 <__bss_end__@@Base+0x1357718> │ │ │ │ + b 13fe2e8 <__bss_end__@@Base+0x1357748> │ │ │ │ strcc r1, [r1, #-3077] @ 0xfffff3fb │ │ │ │ - bl 39ff3c <__bss_end__@@Base+0x2f9304> │ │ │ │ + bl 39fed4 <__bss_end__@@Base+0x2f9334> │ │ │ │ cdpvs 5, 10, cr0, cr0, cr12, {0} │ │ │ │ @ instruction: 0x4641465a │ │ │ │ strtvs r3, [r0], r1, lsl #16 │ │ │ │ strtmi r6, [r0], -r8, rrx │ │ │ │ andge pc, ip, lr, lsr #16 │ │ │ │ stc 5, cr9, [sp, #4] │ │ │ │ vstr s29, [sp] │ │ │ │ @ instruction: 0xf7ff7a03 │ │ │ │ cdpcs 13, 0, cr15, cr0, cr15, {0} │ │ │ │ @ instruction: 0xb00dd1b4 │ │ │ │ - blhi 3c14c8 <__bss_end__@@Base+0x31a890> │ │ │ │ + blhi 3c1460 <__bss_end__@@Base+0x31a8c0> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - blvc 1c1a78 <__bss_end__@@Base+0x11ae40> │ │ │ │ - blge 216b58 <__bss_end__@@Base+0x16ff20> │ │ │ │ + blvc 1c1a10 <__bss_end__@@Base+0x11ae70> │ │ │ │ + blge 216af0 <__bss_end__@@Base+0x16ff50> │ │ │ │ svcmi 0x00b4f5b6 │ │ │ │ ldrmi sl, [r9], -sl, lsl #16 │ │ │ │ @ instruction: 0xf44fbfa8 │ │ │ │ @ instruction: 0x900546b4 │ │ │ │ - bleq 41c10 │ │ │ │ + bleq 41ba8 │ │ │ │ @ instruction: 0xf7fc9304 │ │ │ │ - ldc 15, cr14, [sp, #256] @ 0x100 │ │ │ │ + ldc 15, cr14, [sp, #312] @ 0x138 │ │ │ │ vldr d7, [sp, #32] │ │ │ │ vmov.f64 d5, #10 @ 0x40500000 3.250 │ │ │ │ @ instruction: 0xf64f6b49 │ │ │ │ @ instruction: 0xf6cf0180 │ │ │ │ mcr 1, 0, r7, cr7, cr15, {7} │ │ │ │ vmov.f64 d6, #8 @ 0x40400000 3.0 │ │ │ │ vmls.f64 d7, d5, d10 │ │ │ │ @@ -2824,22 +2824,22 @@ │ │ │ │ vnmla.f64 d7, d22, d7 │ │ │ │ vmov r8, s15 │ │ │ │ @ instruction: 0xe77fba90 │ │ │ │ movwcs r4, #2569 @ 0xa09 │ │ │ │ vadd.i8 d20, d0, d9 │ │ │ │ ldrbtmi r4, [sl], #-331 @ 0xfffffeb5 │ │ │ │ @ instruction: 0xf00c4478 │ │ │ │ - @ instruction: 0xf7fcfaf5 │ │ │ │ - svclt 0x0000ee84 │ │ │ │ + @ instruction: 0xf7fcfee1 │ │ │ │ + svclt 0x0000ee90 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ sbcmi r8, r6, r0 │ │ │ │ - muleq r4, sl, r7 │ │ │ │ - strdeq r3, [r4], -r4 │ │ │ │ + andeq r3, r4, r2, lsl #15 │ │ │ │ + ldrdeq r3, [r4], -ip │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00b8f8cc │ │ │ │ addlt r4, ip, r6, lsr ip │ │ │ │ ldrbtmi r4, [ip], #-2870 @ 0xfffff4ca │ │ │ │ @ instruction: 0xf9b158e3 │ │ │ │ @@ -2847,90 +2847,90 @@ │ │ │ │ @ instruction: 0xf04f930b │ │ │ │ @ instruction: 0xf9b10300 │ │ │ │ addsmi r3, ip, #4 │ │ │ │ @ instruction: 0xf9b1da43 │ │ │ │ strmi r6, [r5], -r2 │ │ │ │ @ instruction: 0x0006f9b1 │ │ │ │ addmi r6, r6, #589824 @ 0x90000 │ │ │ │ - blcc 7cb88 <__bss_start@@Base+0x21ae8> │ │ │ │ + blcc 7cb20 <__bss_start@@Base+0x21b18> │ │ │ │ tstls sl, r3, lsl #2 │ │ │ │ andslt r2, fp, #0, 2 │ │ │ │ vsub.i32 d19, d3, d1 │ │ │ │ andlt r0, r0, #-1073741821 @ 0xc0000003 │ │ │ │ tstpmi pc, r6, ror #6 @ p-variant is OBSOLETE │ │ │ │ smlabtne r4, sp, r9, lr │ │ │ │ vrhadd.u32 d18, d3, d0 │ │ │ │ svcvs 0x006b010f │ │ │ │ tstpmi pc, r0, ror #6 @ p-variant is OBSOLETE │ │ │ │ smlabtne r6, sp, r9, lr │ │ │ │ vrhadd.u32 d18, d4, d0 │ │ │ │ vrhadd.u32 d16, d0, d15 │ │ │ │ svcvs 0x0028411f │ │ │ │ smlabtne r8, sp, r9, lr │ │ │ │ - ble ad6ce4 <__bss_end__@@Base+0xa300ac> │ │ │ │ + ble ad6c7c <__bss_end__@@Base+0xa300dc> │ │ │ │ mrrcne 14, 14, r6, r9, cr8 │ │ │ │ @ instruction: 0x6769011b │ │ │ │ cdpvs 8, 10, cr1, cr9, cr7, {6} │ │ │ │ @ instruction: 0xf10dac05 │ │ │ │ stmdbcc r1, {r2, r4, r5, fp} │ │ │ │ rsbsvs r6, r9, r9, lsr #13 │ │ │ │ @ instruction: 0xf93452c2 │ │ │ │ strtmi r6, [r8], -r2, lsl #24 │ │ │ │ @ instruction: 0x3c04f934 │ │ │ │ @ instruction: 0xf9343408 │ │ │ │ @ instruction: 0xf9342c0e │ │ │ │ stmib sp, {r4, sl, fp, ip}^ │ │ │ │ @ instruction: 0xf7ff6700 │ │ │ │ strmi pc, [r0, #3181]! @ 0xc6d │ │ │ │ - bmi 3faad0 <__bss_end__@@Base+0x353e98> │ │ │ │ + bmi 3faa68 <__bss_end__@@Base+0x353ec8> │ │ │ │ ldrbtmi r4, [sl], #-2829 @ 0xfffff4f3 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, fp, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andlt sp, ip, r2, lsl #2 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ - stmda r6, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r6, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ movwcs r4, #2568 @ 0xa08 │ │ │ │ vadd.i8 d20, d0, d8 │ │ │ │ ldrbtmi r4, [sl], #-331 @ 0xfffffeb5 │ │ │ │ @ instruction: 0xf00c4478 │ │ │ │ - @ instruction: 0xf7fcfa73 │ │ │ │ - svclt 0x0000ee02 │ │ │ │ - andeq r1, r5, lr, lsl #27 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r1, r5, sl, ror #25 │ │ │ │ - muleq r4, r6, r6 │ │ │ │ - strdeq r3, [r4], -r0 │ │ │ │ + @ instruction: 0xf7fcfe5f │ │ │ │ + svclt 0x0000ee0e │ │ │ │ + strdeq r1, [r5], -r6 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r1, r5, r2, asr sp │ │ │ │ + andeq r3, r4, lr, ror r6 │ │ │ │ + ldrdeq r3, [r4], -r8 │ │ │ │ addne pc, r0, r0, asr #17 │ │ │ │ - bleq 7c1964 <__bss_end__@@Base+0x71ad2c> │ │ │ │ + bleq 7c18fc <__bss_end__@@Base+0x71ad5c> │ │ │ │ svclt 0x00004770 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb68fa4 <__bss_end__@@Base+0xfeac236c> │ │ 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<__bss_end__@@Base+0x1b254> │ │ │ │ - blgt 41ea4 │ │ │ │ + blvc c1e24 <__bss_end__@@Base+0x1b284> │ │ │ │ + blgt 41e3c │ │ │ │ mcr 6, 1, r4, cr0, cr0, {1} │ │ │ │ vdiv.f64 d0, d0, d7 │ │ │ │ vadd.f64 d7, d7, d8 │ │ │ │ vdiv.f64 d7, d12, d12 │ │ │ │ @ instruction: 0xf000db07 │ │ │ │ vmov.16 d9[0], pc │ │ │ │ @ instruction: 0xf8d50a10 │ │ │ │ @@ -2950,70 +2950,70 @@ │ │ │ │ @ instruction: 0xf8d50a10 │ │ │ │ @ instruction: 0xf0000080 │ │ │ │ vmov.32 pc, d8[1] │ │ │ │ vcvt.f64.s32 d7, s22 │ │ │ │ vmls.f64 d5, d22, d27 │ │ │ │ @ instruction: 0xeeb80a10 │ │ │ │ stmdavs r8!, {r3, r6, r7, r8, r9, fp, pc} │ │ │ │ - blvs ff1c1f18 <__bss_end__@@Base+0xff11b2e0> │ │ │ │ - blgt 1381d2c <__bss_end__@@Base+0x12db0f4> │ │ │ │ - blge 381ce8 <__bss_end__@@Base+0x2db0b0> │ │ │ │ - blls 381ce8 <__bss_end__@@Base+0x2db0b0> │ │ │ │ - blhi 381ce8 <__bss_end__@@Base+0x2db0b0> │ │ │ │ - blge 341c68 <__bss_end__@@Base+0x29b030> │ │ │ │ - blls 341c64 <__bss_end__@@Base+0x29b02c> │ │ │ │ - blhi 341c6c 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<__bss_end__@@Base+0xfeac2614> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf8df0e58 │ │ │ │ rsclt ip, r4, r0, lsl r1 │ │ │ │ - bcs 18d9728 <__bss_end__@@Base+0x1832af0> │ │ │ │ + bcs 18d96c0 <__bss_end__@@Base+0x1832b20> │ │ │ │ @ instruction: 0xf8bd44fc │ │ │ │ @ instruction: 0xf85ce1a8 │ │ │ │ stmdavs r4!, {r2, lr} │ │ │ │ @ instruction: 0xf04f9463 │ │ │ │ stclle 4, cr0, [r0], #-0 │ │ │ │ vldmdble ip!, {s4-s3} │ │ │ │ - bleq 41c84 │ │ │ │ + bleq 41c1c │ │ │ │ ldc 6, cr4, [r3, #944] @ 0x3b0 │ │ │ │ vmov.f64 d1, #98 @ 0x3f100000 0.5625000 │ │ │ │ vldr d6, [r3] │ │ │ │ vldr d2, [r3, #32] │ │ │ │ vldr d3, [r3, #16] │ │ │ │ vldr d4, [r3, #24] │ │ │ │ addseq r5, r3, sl, lsl #22 │ │ │ │ @@ -3118,1453 +3118,1439 @@ │ │ │ │ @ instruction: 0x1c03ea4f │ │ │ │ strbvs r3, [r3, -r1, lsl #6] │ │ │ │ movweq lr, #51972 @ 0xcb04 │ │ │ │ stmdbcc r1, {r0, r7, r9, sl, fp, sp, lr} │ │ │ │ subsvs r6, r9, r1, lsl #13 │ │ │ │ @ instruction: 0xf8244669 │ │ │ │ @ instruction: 0xf7fee00c │ │ │ │ - bmi 5862dc <__bss_end__@@Base+0x4df6a4> │ │ │ │ + bmi 586274 <__bss_end__@@Base+0x4df6d4> │ │ │ │ ldrbtmi r4, [sl], #-2835 @ 0xfffff4ed │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r3, ror #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ rsblt sp, r4, lr, lsl #2 │ │ │ │ - blhi 1419e4 <__bss_end__@@Base+0x9adac> │ │ │ │ - blmi 3f5b34 <__bss_end__@@Base+0x34eefc> │ │ │ │ + blhi 14197c <__bss_end__@@Base+0x9addc> │ │ │ │ + blmi 3f5acc <__bss_end__@@Base+0x34ef2c> │ │ │ │ addsvc pc, pc, #64, 4 │ │ │ │ stmdami pc, {r1, r2, r3, r8, fp, lr} @ │ │ │ │ ldrbtmi r4, [r9], #-1147 @ 0xfffffb85 │ │ │ │ ldrbtmi r3, [r8], #-800 @ 0xfffffce0 │ │ │ │ - ldcl 7, cr15, [r6], #1008 @ 0x3f0 │ │ │ │ - mrc 7, 2, APSR_nzcv, cr8, cr12, {7} │ │ │ │ + stc 7, cr15, [r4, #-1008] @ 0xfffffc10 │ │ │ │ + mcr 7, 3, pc, cr8, cr12, {7} @ │ │ │ │ movwcs r4, #2571 @ 0xa0b │ │ │ │ vadd.i8 d20, d0, d11 │ │ │ │ ldrbtmi r4, [sl], #-331 @ 0xfffffeb5 │ │ │ │ @ instruction: 0xf00c4478 │ │ │ │ - @ instruction: 0xf7fcf885 │ │ │ │ - svclt 0x0000ec14 │ │ │ │ - andeq r1, r5, r4, ror #19 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r1, r5, r6, lsr #18 │ │ │ │ - andeq r6, r4, r4, ror ip │ │ │ │ - andeq r3, r4, lr, lsr #4 │ │ │ │ - andeq r3, r4, sl, lsr r3 │ │ │ │ - @ instruction: 0x000432ba │ │ │ │ - andeq r3, r4, r4, lsl r2 │ │ │ │ + @ instruction: 0xf7fcfc71 │ │ │ │ + svclt 0x0000ec20 │ │ │ │ + andeq r1, r5, ip, asr #20 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r1, r5, lr, lsl #19 │ │ │ │ + andeq r6, r4, r0, lsl #29 │ │ │ │ + andeq r3, r4, r6, lsl r2 │ │ │ │ + andeq r3, r4, r2, lsr #6 │ │ │ │ + andeq r3, r4, r2, lsr #5 │ │ │ │ + strdeq r3, [r4], -ip │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb5d94c <__bss_end__@@Base+0xfeab6d14> │ │ │ │ + bl feb5d8e4 <__bss_end__@@Base+0xfeab6d44> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [ip, #-960] @ 0xfffffc40 │ │ │ │ - blmi 30ef88 <__bss_end__@@Base+0x268350> │ │ │ │ + blmi 30ef20 <__bss_end__@@Base+0x268380> │ │ │ │ @ instruction: 0x71aff240 │ │ │ │ ldrbtmi r4, [fp], #-1149 @ 0xfffffb83 │ │ │ │ @ instruction: 0xf00d4628 │ │ │ │ - strmi pc, [r4], -r3, asr #18 │ │ │ │ + strmi pc, [r4], -r3, ror #19 │ │ │ │ andcs r2, sl, #0, 6 │ │ │ │ vmax.s8 d20, d0, d24 │ │ │ │ stmib r4, {r1, r4, r5, r7, r8, ip, sp, lr}^ │ │ │ │ eorcs r3, r8, #0, 4 │ │ │ │ - @ instruction: 0xf938f00d │ │ │ │ + @ instruction: 0xf9d8f00d │ │ │ │ strtmi r4, [r0], -r3, lsl #12 │ │ │ │ ldclt 0, cr6, [r8, #-652]! @ 0xfffffd74 │ │ │ │ - ldrdeq r3, [r4], -r0 │ │ │ │ + @ instruction: 0x000431b8 │ │ │ │ @ instruction: 0xffffdf3f │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb5d994 <__bss_end__@@Base+0xfeab6d5c> │ │ │ │ + bl feb5d92c <__bss_end__@@Base+0xfeab6d8c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ ldmib r0, {r3, r5, r6, r7, r8, r9, sl, fp}^ │ │ │ │ ldrmi r5, [r6], -r0, lsl #6 │ │ │ │ stmvs r2, {r2, r9, sl, lr} │ │ │ │ addsmi r4, sp, #15728640 @ 0xf00000 │ │ │ │ - bl bcfc8 <__bss_end__@@Base+0x16390> │ │ │ │ + bl bcf60 <__bss_end__@@Base+0x163c0> │ │ │ │ stclne 3, cr0, [r9], #-532 @ 0xfffffdec │ │ │ │ @ instruction: 0xf8226021 │ │ │ │ subshi r7, lr, r5, lsr #32 │ │ │ │ ldrsheq fp, [r9], #-216 @ 0xffffff28 │ │ │ │ stmdami r5, {r0, r6, sp, lr} │ │ │ │ vqadd.s8 q8, q8, │ │ │ │ ldrbtmi r7, [r8], #-443 @ 0xfffffe45 │ │ │ │ - blx 942800 <__bss_end__@@Base+0x89bbc8> │ │ │ │ + blx ff142798 <__bss_end__@@Base+0xff09bbf8> │ │ │ │ strmi r6, [r2], -r5, lsr #16 │ │ │ │ strb r6, [sl, r0, lsr #1]! │ │ │ │ - andeq r3, r4, r6, ror #2 │ │ │ │ + andeq r3, r4, lr, asr #2 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5d9e0 <__bss_end__@@Base+0xfeab6da8> │ │ │ │ + bl feb5d978 <__bss_end__@@Base+0xfeab6dd8> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ ldmib r0, {r4, r5, r6, r7, r8, r9, sl, fp}^ │ │ │ │ strmi r5, [r4], -r0, lsl #6 │ │ │ │ strmi r6, [lr], -r2, lsl #17 │ │ │ │ - ble 157268 <__bss_end__@@Base+0xb0630> │ │ │ │ + ble 157200 <__bss_end__@@Base+0xb0660> │ │ │ │ stclne 8, cr6, [r9], #-204 @ 0xffffff34 │ │ │ │ @ instruction: 0xf8426021 │ │ │ │ ldcllt 0, cr3, [r0, #-148]! @ 0xffffff6c │ │ │ │ subvs r0, r1, r9, asr r0 │ │ │ │ sbcseq r4, fp, r7, lsl #16 │ │ │ │ bicvc pc, r5, r0, asr #4 │ │ │ │ @ instruction: 0xf00d4478 │ │ │ │ - stmdavs r5!, {r0, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmdavs r5!, {r0, r5, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ ldmdavs r3!, {r1, r9, sl, lr} │ │ │ │ adcvs r1, r0, r9, ror #24 │ │ │ │ @ instruction: 0xf8426021 │ │ │ │ ldcllt 0, cr3, [r0, #-148]! @ 0xffffff6c │ │ │ │ - andeq r3, r4, r0, lsr #2 │ │ │ │ + andeq r3, r4, r8, lsl #2 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5da30 <__bss_end__@@Base+0xfeab6df8> │ │ │ │ + bl feb5d9c8 <__bss_end__@@Base+0xfeab6e28> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ mcrmi 15, 0, r0, cr15, cr0, {7} │ │ │ │ - blmi 3d8050 <__bss_end__@@Base+0x331418> │ │ │ │ + blmi 3d7fe8 <__bss_end__@@Base+0x331448> │ │ │ │ ldrbtmi r2, [lr], #-524 @ 0xfffffdf4 │ │ │ │ bicvc pc, sp, r0, asr #4 │ │ │ │ @ instruction: 0x4630447b │ │ │ │ - @ instruction: 0xf8d0f00d │ │ │ │ + @ instruction: 0xf970f00d │ │ │ │ strmi r6, [r4], -sl, lsr #16 │ │ │ │ ldrtmi r2, [r0], -r0, lsl #6 │ │ │ │ mvnsvs pc, pc, asr #8 │ │ │ │ andcs lr, r0, #196, 18 @ 0x310000 │ │ │ │ @ instruction: 0xf00d0092 │ │ │ │ - stmdavs r2!, {r0, r2, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ + stmdavs r2!, {r0, r2, r5, r6, r8, fp, ip, sp, lr, pc} │ │ │ │ addseq r6, r2, r0, lsr #1 │ │ │ │ @ instruction: 0xf7fc68a9 │ │ │ │ - strtmi lr, [r0], -r0, ror #25 │ │ │ │ + @ instruction: 0x4620ecf0 │ │ │ │ svclt 0x0000bd70 │ │ │ │ - andeq r3, r4, lr, ror #1 │ │ │ │ + ldrdeq r3, [r4], -r6 │ │ │ │ @ instruction: 0xffffde59 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb5da84 <__bss_end__@@Base+0xfeab6e4c> │ │ │ │ + bl feb5da1c <__bss_end__@@Base+0xfeab6e7c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [sp], {248} @ 0xf8 │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ - blx 1f028cc <__bss_end__@@Base+0x1e5bc94> │ │ │ │ - blvc 42358 │ │ │ │ - bleq ff20236c <__bss_end__@@Base+0xff15b734> │ │ │ │ - blx 442464 <__bss_end__@@Base+0x39b82c> │ │ │ │ + blx ff0c2864 <__bss_end__@@Base+0xff01bcc4> │ │ │ │ + blvc 422f0 │ │ │ │ + bleq ff202304 <__bss_end__@@Base+0xff15b764> │ │ │ │ + blx 4423fc <__bss_end__@@Base+0x39b85c> │ │ │ │ stcmi 12, cr13, [r8], {7} │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ - @ instruction: 0xf950f00d │ │ │ │ + @ instruction: 0xf9f0f00d │ │ │ │ eorvs r2, r3, r0, lsl #6 │ │ │ │ stmdbmi r5, {r4, r8, sl, fp, ip, sp, pc} │ │ │ │ ldrbtmi r6, [r9], #-2080 @ 0xfffff7e0 │ │ │ │ - blx ff2c28f4 <__bss_end__@@Base+0xff21bcbc> │ │ │ │ + blx ffb4288c <__bss_end__@@Base+0xffa9bcec> │ │ │ │ svclt 0x0000e7f1 │ │ │ │ - andeq r4, r5, ip, lsl r8 │ │ │ │ - andeq r4, r5, r4, lsl #16 │ │ │ │ - andeq r3, r4, r6, lsr #3 │ │ │ │ + andeq r4, r5, ip, ror #15 │ │ │ │ + ldrdeq r4, [r5], -r4 @ │ │ │ │ + andeq r3, r4, lr, lsl #3 │ │ │ │ ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00d8f8cc │ │ │ │ movwmi r4, #42519 @ 0xa617 │ │ │ │ addlt r4, r2, r2, lsl #6 │ │ │ │ strmi r4, [r1], r8, lsl #13 │ │ │ │ ldmdale r3, {r0, r1, r2, r3, r4, r5, r6, r7, r9, fp, sp}^ │ │ │ │ cdpne 12, 1, cr4, cr14, cr15, {1} │ │ │ │ @ instruction: 0x2601bf18 │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ eorsle r2, pc, r0, lsl #16 │ │ │ │ strcs lr, [r8], #-2639 @ 0xfffff5b1 │ │ │ │ strvs lr, [r6], #-2628 @ 0xfffff5bc │ │ │ │ - b 11175f8 <__bss_end__@@Base+0x10709c0> │ │ │ │ + b 1117590 <__bss_end__@@Base+0x10709f0> │ │ │ │ strtmi r4, [r1], -r9, lsl #8 │ │ │ │ - blx 8c2948 <__bss_end__@@Base+0x81bd10> │ │ │ │ + blx 1ac28e0 <__bss_end__@@Base+0x1a1bd40> │ │ │ │ tstlt r8, r5, lsl #12 │ │ │ │ andlt r4, r2, r8, lsr #12 │ │ │ │ @ instruction: 0x87f0e8bd │ │ │ │ @ instruction: 0xa090f8df │ │ │ │ andcs r4, r8, #3145728 @ 0x300000 │ │ │ │ ldrbtmi r2, [sl], #317 @ 0x13d │ │ │ │ @ instruction: 0xf00d4650 │ │ │ │ - @ instruction: 0x463bf85f │ │ │ │ + @ instruction: 0x463bf8ff │ │ │ │ strbmi r4, [r2], -r5, lsl #12 │ │ │ │ andcs r4, r0, r9, asr #12 │ │ │ │ - @ instruction: 0xf975f00c │ │ │ │ + ldc2 0, cr15, [r2], #-48 @ 0xffffffd0 │ │ │ │ strtmi r2, [sl], -r0, lsl #6 │ │ │ │ vmax.u32 d20, d6, d17 │ │ │ │ cdpmi 3, 1, cr0, cr11, cr7, {0} │ │ │ │ vhadd.u32 d22, d9, d24 │ │ │ │ ldrbtmi r2, [lr], #-783 @ 0xfffffcf1 │ │ │ │ tstpmi r7, #104, 6 @ p-variant is OBSOLETE @ 0xa0000001 │ │ │ │ vceq.i32 d22, d7, d16 │ │ │ │ rsbvs r6, fp, pc, lsl r3 │ │ │ │ - @ instruction: 0xf9b6f00e │ │ │ │ + blx 242930 <__bss_end__@@Base+0x19bd90> │ │ │ │ @ instruction: 0x46216830 │ │ │ │ - @ instruction: 0xf9f6f00e │ │ │ │ + blx fc2938 <__bss_end__@@Base+0xf1bd98> │ │ │ │ sbcsle r4, r3, r5, lsl #5 │ │ │ │ subcs r4, r4, #18432 @ 0x4800 │ │ │ │ @ instruction: 0x46514812 │ │ │ │ ldrbtmi r4, [r8], #-1147 @ 0xfffffb85 │ │ │ │ - bl fef4496c <__bss_end__@@Base+0xfee9dd34> │ │ │ │ + bl ff2c4904 <__bss_end__@@Base+0xff21dd64> │ │ │ │ vmax.s8 d20, d0, d1 │ │ │ │ @ instruction: 0xf00e40d2 │ │ │ │ - eorvs pc, r0, sp, lsr #18 │ │ │ │ + strhtvs pc, [r0], -pc @ │ │ │ │ ldrbtmi r4, [r8], #-2061 @ 0xfffff7f3 │ │ │ │ - blx fe1c29c6 <__bss_end__@@Base+0xfe11bd8e> │ │ │ │ + stc2 0, cr15, [r6], #-52 @ 0xffffffcc │ │ │ │ ldr r6, [r3, r0, lsr #16]! │ │ │ │ - bmi 2d81a4 <__bss_end__@@Base+0x23156c> │ │ │ │ + bmi 2d813c <__bss_end__@@Base+0x23159c> │ │ │ │ @ instruction: 0x212f480b │ │ │ │ stmib sp, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldrbtmi r8, [r8], #-1792 @ 0xfffff900 │ │ │ │ - @ instruction: 0xff40f00b │ │ │ │ - b ff3c499c <__bss_end__@@Base+0xff31dd64> │ │ │ │ - @ instruction: 0x000547b4 │ │ │ │ - andeq r3, r4, sl, ror r1 │ │ │ │ - andeq r4, r5, sl, asr r7 │ │ │ │ - andeq r6, r4, r8, lsr sl │ │ │ │ - andeq r3, r4, sl, lsr r1 │ │ │ │ + blx b42972 <__bss_end__@@Base+0xa9bdd2> │ │ │ │ + b ff6c4934 <__bss_end__@@Base+0xff61dd94> │ │ │ │ + andeq r4, r5, r4, lsl #15 │ │ │ │ + andeq r3, r4, r2, ror #2 │ │ │ │ + andeq r4, r5, sl, lsr #14 │ │ │ │ + andeq r6, r4, r4, asr #24 │ │ │ │ + andeq r3, r4, lr, lsl r1 │ │ │ │ @ instruction: 0xfffffeef │ │ │ │ - andeq r3, r4, ip, ror #1 │ │ │ │ - strdeq r3, [r4], -lr │ │ │ │ + ldrdeq r3, [r4], -r4 │ │ │ │ + andeq r3, r4, r6, ror #1 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5dbd4 <__bss_end__@@Base+0xfeab6f9c> │ │ │ │ + bl feb5db6c <__bss_end__@@Base+0xfeab6fcc> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf8df0fe0 │ │ │ │ strmi ip, [ip], -r0, rrx │ │ │ │ addlt r4, r5, r7, lsl r9 │ │ │ │ - blge 97dd8 <__bss_start@@Base+0x3cd38> │ │ │ │ + blge 97d70 <__bss_start@@Base+0x3cd68> │ │ │ │ strmi sl, [r5], -r1, lsl #20 │ │ │ │ andne pc, r1, ip, asr r8 @ │ │ │ │ tstls r3, r9, lsl #16 │ │ │ │ tstpeq r0, pc, asr #32 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf00c4669 │ │ │ │ - @ instruction: 0xb188f9bd │ │ │ │ + orrlt pc, r8, r5, lsr ip @ │ │ │ │ andne lr, r1, #3620864 @ 0x374000 │ │ │ │ stmdals r0, {r0, r1, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xff60f7ff │ │ │ │ - blmi 319244 <__bss_end__@@Base+0x27260c> │ │ │ │ + blmi 3191dc <__bss_end__@@Base+0x27263c> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls e0a80 <__bss_end__@@Base+0x39e48> │ │ │ │ + blls e0a18 <__bss_end__@@Base+0x39e78> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, (UNDEF: 59) │ │ │ │ ldclt 0, cr11, [r0, #-20]! @ 0xffffffec │ │ │ │ strtmi r4, [fp], -r8, lsl #20 │ │ │ │ cmpcs sp, r8, lsl #16 │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - cdp2 0, 15, cr15, cr10, cr11, {0} │ │ │ │ - b fe244a28 <__bss_end__@@Base+0xfe19ddf0> │ │ │ │ - stcl 7, cr15, [r0], {252} @ 0xfc │ │ │ │ - andeq r1, r5, ip, lsl r6 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - strdeq r1, [r5], -r0 │ │ │ │ - andeq r3, r4, ip, lsr #1 │ │ │ │ - andeq r3, r4, r2, ror r0 │ │ │ │ + blx ff9c29fc <__bss_end__@@Base+0xff91be5c> │ │ │ │ + b fe5449c0 <__bss_end__@@Base+0xfe49de20> │ │ │ │ + ldcl 7, cr15, [r0], {252} @ 0xfc │ │ │ │ + andeq r1, r5, r4, lsl #13 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r1, r5, r8, asr r6 │ │ │ │ + muleq r4, r0, r0 │ │ │ │ + andeq r3, r4, sl, asr r0 │ │ │ │ ldrbmi r6, [r0, -r0, lsl #16]! │ │ │ │ ldrbmi r7, [r0, -r0, lsl #18]! │ │ │ │ ldrbmi r7, [r0, -r0, asr #18]! │ │ │ │ ldrbmi r7, [r0, -r0, lsl #19]! │ │ │ │ ldrbmi r7, [r0, -r0, asr #19]! │ │ │ │ - vst3.8 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5dc6c <__bss_end__@@Base+0xfeab7034> │ │ │ │ + vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ + bl feb5dc04 <__bss_end__@@Base+0xfeab7064> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - addlt r0, r5, r0, ror #31 │ │ │ │ - @ instruction: 0x4c0979c5 │ │ │ │ - blmi 24f2a8 <__bss_end__@@Base+0x1a8670> │ │ │ │ - strls r2, [r2, #-257] @ 0xfffffeff │ │ │ │ - strcc r4, [r4], #-1148 @ 0xfffffb84 │ │ │ │ - stmibvc r5, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - stmdbvc r0, {r0, r8, sl, ip, pc}^ │ │ │ │ - strtmi r9, [r0], -r0 │ │ │ │ - ldc 7, cr15, [r8, #-1008]! @ 0xfffffc10 │ │ │ │ - andlt r4, r5, r0, lsr #12 │ │ │ │ - svclt 0x0000bd30 │ │ │ │ - andeq r4, r5, r8, lsr #12 │ │ │ │ - andeq r3, r4, r4, ror r0 │ │ │ │ - svcmi 0x00f0e92d │ │ │ │ - stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi c1f64 <__bss_end__@@Base+0x1b32c> │ │ │ │ - @ instruction: 0x0c0cebad │ │ │ │ - svceq 0x00c8f8cc │ │ │ │ - addlt r4, r3, r1, lsr #26 │ │ │ │ - @ instruction: 0xf8dd447d │ │ │ │ - stmib sp, {r2, r3, r4, r5, pc}^ │ │ │ │ - @ instruction: 0xf8d51200 │ │ │ │ - svccs 0x00007200 │ │ │ │ - mrc 13, 5, sp, cr0, cr3, {1} │ │ │ │ - strmi r8, [r6], -r0, asr #22 │ │ │ │ - @ instruction: 0xf04f469b │ │ │ │ - and r0, r2, r0, lsl #20 │ │ │ │ - ldrmi r3, [sl, #1284]! @ 0x504 │ │ │ │ - @ instruction: 0xf8d5d029 │ │ │ │ - ldrtmi r9, [r1], -r0 │ │ │ │ - beq 82f14 <__bss_start@@Base+0x27e74> │ │ │ │ - ldrdeq pc, [r0], -r9 │ │ │ │ - ldcl 7, cr15, [r0, #-1008] @ 0xfffffc10 │ │ │ │ - stmdacs r0, {r2, r9, sl, lr} │ │ │ │ - @ instruction: 0xf8d9d1f0 │ │ │ │ - bcs ecc0 │ │ │ │ - @ instruction: 0xf8d9dd19 │ │ │ │ - @ instruction: 0x465b0074 │ │ │ │ - ldrdvs pc, [r0], -r8 │ │ │ │ - bleq 12425d0 <__bss_end__@@Base+0x119b998> │ │ │ │ - @ instruction: 0xf8509a01 │ │ │ │ - ldclne 0, cr0, [r1], #-144 @ 0xffffff70 │ │ │ │ - andne pc, r0, r8, asr #17 │ │ │ │ - stmdbls r0, {r0, sl, ip, sp} │ │ │ │ - @ instruction: 0xffeaf002 │ │ │ │ - ldrdls pc, [r0], -r5 │ │ │ │ - @ instruction: 0xf8d99b0e │ │ │ │ - @ instruction: 0xf8432070 │ │ │ │ - adcmi r0, r2, #38 @ 0x26 │ │ │ │ - andlt sp, r3, r5, ror #25 │ │ │ │ - blhi c1e30 <__bss_end__@@Base+0x1b1f8> │ │ │ │ - svchi 0x00f0e8bd │ │ │ │ + @ instruction: 0x46020ff0 │ │ │ │ + stcmi 0, cr11, [r7], {130} @ 0x82 │ │ │ │ + ldmibvc r3, {r0, r1, r2, r8, fp, lr}^ │ │ │ │ + movwls r4, #1148 @ 0x47c │ │ │ │ + ldrbtmi r3, [r9], #-1028 @ 0xfffffbfc │ │ │ │ + ldmibvc r3, {r5, r9, sl, lr} │ │ │ │ + @ instruction: 0xf7fc7952 │ │ │ │ + @ instruction: 0x4620edbc │ │ │ │ + ldclt 0, cr11, [r0, #-8] │ │ │ │ strdeq r4, [r5], -ip │ │ │ │ + andeq r3, r4, sl, asr r0 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ - bleq ff444e84 <__bss_end__@@Base+0xff39e24c> │ │ │ │ - bmi fed98598 <__bss_end__@@Base+0xfecf1960> │ │ │ │ - blmi fed985c0 <__bss_end__@@Base+0xfecf1988> │ │ │ │ + bleq ff444d74 <__bss_end__@@Base+0xff39e1d4> │ │ │ │ + bmi fec58488 <__bss_end__@@Base+0xfebb18e8> │ │ │ │ + blmi fec584b0 <__bss_end__@@Base+0xfebb1910> │ │ │ │ @ instruction: 0xf2ad447a │ │ │ │ stcge 13, cr4, [r1, #-48] @ 0xffffffd0 │ │ │ │ strmi r4, [sl], r4, lsl #12 │ │ │ │ tstpvc r0, pc, asr #8 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0x460258d3 │ │ │ │ @ instruction: 0xf8dd4628 │ │ │ │ ldmdavs fp, {r4, r5, sl, ip, sp, pc} │ │ │ │ strcc pc, [r4], #-2253 @ 0xfffff733 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - b cc4b74 <__bss_end__@@Base+0xc1df3c> │ │ │ │ + b fe4c4a64 <__bss_end__@@Base+0xfe41dec4> │ │ │ │ stcge 6, cr4, [r1], {34} @ 0x22 │ │ │ │ vst1.8 {d20-d22}, [pc], r7 │ │ │ │ strtmi r7, [r0], -r0, lsl #2 │ │ │ │ - b ac4b84 <__bss_end__@@Base+0xa1df4c> │ │ │ │ - strmi r4, [r6], -r8, lsr #21 │ │ │ │ + b fe2c4a74 <__bss_end__@@Base+0xfe21ded4> │ │ │ │ + strmi r4, [r6], -r3, lsr #21 │ │ │ │ ldrbtmi r4, [sl], #-1576 @ 0xfffff9d8 │ │ │ │ - andcc pc, r4, #13762560 @ 0xd20000 │ │ │ │ - @ instruction: 0xf8c23302 │ │ │ │ - @ instruction: 0xf7fc3204 │ │ │ │ - cmplt r0, ip, lsr fp │ │ │ │ + movwcc r6, #10259 @ 0x2813 │ │ │ │ + @ instruction: 0xf7fc6013 │ │ │ │ + cmplt r0, r2, lsr #23 │ │ │ │ andcs r1, r0, #2818048 @ 0x2b0000 │ │ │ │ @ instruction: 0xf8032801 │ │ │ │ andle r2, r4, r1, lsl #24 │ │ │ │ stcpl 8, cr3, [fp], #-8 │ │ │ │ svclt 0x00082b0d │ │ │ │ strtmi r5, [r0], -sl, lsr #8 │ │ │ │ - bl b44bb8 <__bss_end__@@Base+0xa9df80> │ │ │ │ + bl fe4c4aa4 <__bss_end__@@Base+0xfe41df04> │ │ │ │ stmdane r3!, {r4, r6, r8, ip, sp, pc} │ │ │ │ stmdacs r1, {r9, sp} │ │ │ │ stccs 8, cr15, [r1], {3} │ │ │ │ stmdacc r2, {r2, ip, lr, pc} │ │ │ │ - blcs 35dc68 <__bss_end__@@Base+0x2b7030> │ │ │ │ + blcs 35db54 <__bss_end__@@Base+0x2b6fb4> │ │ │ │ strtpl fp, [r2], #-3848 @ 0xfffff0f8 │ │ │ │ strbmi r4, [r0], -r1, lsr #12 │ │ │ │ - bl 1844bd8 <__bss_end__@@Base+0x179dfa0> │ │ │ │ + bl ff1c4ac4 <__bss_end__@@Base+0xff11df24> │ │ │ │ ldrbmi r4, [r8], -r1, lsr #12 │ │ │ │ - bl 1744be0 <__bss_end__@@Base+0x169dfa8> │ │ │ │ + bl ff0c4acc <__bss_end__@@Base+0xff01df2c> │ │ │ │ svclt 0x00182f00 │ │ │ │ tstle r0, r0, lsl #28 │ │ │ │ - bmi fe40ec00 <__bss_end__@@Base+0xfe367fc8> │ │ │ │ - ldrbtmi r4, [sl], #-2957 @ 0xfffff473 │ │ │ │ + bmi fe30eaec <__bss_end__@@Base+0xfe267f4c> │ │ │ │ + ldrbtmi r4, [sl], #-2953 @ 0xfffff477 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ strcc pc, [r4], #-2269 @ 0xfffff723 │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ - vrhadd.s8 d8, d13, d12 │ │ │ │ + vrhadd.s8 d8, d13, d5 │ │ │ │ pop {r2, r3, r8, sl, fp, lr} │ │ │ │ andcs r8, r0, #240, 30 @ 0x3c0 │ │ │ │ ldrmi r4, [r1], -r8, lsr #12 │ │ │ │ - bl f44c14 <__bss_end__@@Base+0xe9dfdc> │ │ │ │ + bl fe8c4b00 <__bss_end__@@Base+0xfe81df60> │ │ │ │ andeq pc, r0, r9, asr #17 │ │ │ │ stmdacs r2, {r5, r6, r8, r9, ip, sp, pc} │ │ │ │ - stmdacs sl, {r6, ip, lr, pc}^ │ │ │ │ - sbcshi pc, sl, r0, lsl #6 │ │ │ │ - ldclle 8, cr2, [r3, #-36] @ 0xffffffdc │ │ │ │ + stmdacs sl, {r0, r1, r2, r3, r4, r5, ip, lr, pc}^ │ │ │ │ + sbcshi pc, r3, r0, lsl #6 │ │ │ │ + ldclle 8, cr2, [r2, #-36] @ 0xffffffdc │ │ │ │ stmdacs r0, {r1, r3, fp, ip, sp}^ │ │ │ │ - ldm pc, {r4, r6, fp, ip, lr, pc}^ @ │ │ │ │ - msrvs SPSR_c, r0 │ │ │ │ - cmnvs r1, r1, ror #2 │ │ │ │ - cmnvs r1, r1, ror #2 │ │ │ │ - ldmdbpl r9, {r0, r3, r4, r6, r8, fp, ip, lr}^ │ │ │ │ - ldmdbpl r9, {r0, r3, r4, r6, r8, fp, ip, lr}^ │ │ │ │ - cmppl r1, r9, asr r9 │ │ │ │ - cmppl r1, r1, asr r1 │ │ │ │ - cmppl r1, r1, asr r1 │ │ │ │ - blgt 1ae39a0 <__bss_end__@@Base+0x1a3cd68> │ │ │ │ - svcmi 0x004f4f4f │ │ │ │ - svcmi 0x00c34f4f │ │ │ │ - svcmi 0x004f4f4f │ │ │ │ - svcmi 0x004f4f4f │ │ │ │ - svcmi 0x00b74f4f │ │ │ │ - svcmi 0x004f4f4f │ │ │ │ - svcls 0x00ab4f4f │ │ │ │ - @ instruction: 0x007b8793 │ │ │ │ - ldrbtmi r4, [sp], #-3438 @ 0xfffff292 │ │ │ │ + ldm pc, {r0, r1, r2, r3, r6, fp, ip, lr, pc}^ @ │ │ │ │ + rsbvs pc, r0, r0 │ │ │ │ + rsbvs r6, r0, r0, rrx │ │ │ │ + rsbvs r6, r0, r0, rrx │ │ │ │ + ldmdapl r8, {r3, r4, r6, fp, ip, lr}^ │ │ │ │ + ldmdapl r8, {r3, r4, r6, fp, ip, lr}^ │ │ │ │ + subspl r5, r0, r8, asr r8 │ │ │ │ + subspl r5, r0, r0, asr r0 │ │ │ │ + subspl r5, r0, r0, asr r0 │ │ │ │ + strbtgt r7, [sl], #-590 @ 0xfffffdb2 │ │ │ │ + cdpmi 14, 4, cr4, cr14, cr14, {2} │ │ │ │ + cdpmi 14, 11, cr4, cr12, cr14, {2} │ │ │ │ + cdpmi 14, 4, cr4, cr14, cr14, {2} │ │ │ │ + cdpmi 14, 4, cr4, cr14, cr14, {2} │ │ │ │ + cdpmi 14, 11, cr4, cr1, cr14, {2} │ │ │ │ + cdpmi 14, 4, cr4, cr14, cr14, {2} │ │ │ │ + blls fe99a4a4 <__bss_end__@@Base+0xfe8f3904> │ │ │ │ + @ instruction: 0x007a8590 │ │ │ │ + ldrbtmi r4, [sp], #-3434 @ 0xfffff296 │ │ │ │ ldmdblt r8, {r3, r5, r6, fp, sp, lr} │ │ │ │ stmiavs r8!, {r0, r3, sp, lr, pc}^ │ │ │ │ teqlt r0, r8, lsl #10 │ │ │ │ @ instruction: 0xf7fc4621 │ │ │ │ - stmdacs r0, {r1, r2, r3, r4, r5, r6, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r4, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ stmdavs r8!, {r0, r1, r2, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ - stmdbmi r8!, {r0, r1, r3, r5, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ - andcs r4, r1, r2, lsr #12 │ │ │ │ - @ instruction: 0xf7fc4479 │ │ │ │ - str lr, [r3, sl, lsr #19]! │ │ │ │ - strtmi r4, [r1], -r5, ror #16 │ │ │ │ - @ instruction: 0xf7fc4478 │ │ │ │ - cmplt r8, #28160 @ 0x6e00 │ │ │ │ - strtmi r4, [r1], -r3, ror #16 │ │ │ │ - @ instruction: 0xf7fc4478 │ │ │ │ - stmdacs r0, {r3, r5, r6, sl, fp, sp, lr, pc} │ │ │ │ - addshi pc, sp, r0 │ │ │ │ - strtmi r4, [r1], -r0, ror #16 │ │ │ │ - @ instruction: 0xf7fc4478 │ │ │ │ - stmdacs r0, {r5, r6, sl, fp, sp, lr, pc} │ │ │ │ - andcs fp, ip, r4, lsl pc │ │ │ │ - usada8 ip, ip, r0, r2 │ │ │ │ - usada8 sl, fp, r0, r2 │ │ │ │ - tstcs r0, r0, lsr #12 │ │ │ │ - ldmib r0, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - stc 0, cr2, [sl, #16] │ │ │ │ - str r0, [r2, r0, lsl #22] │ │ │ │ - tstcs r0, r0, lsr #12 │ │ │ │ - stmib r8, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - stc 0, cr2, [sl, #12] │ │ │ │ - ldrb r0, [sl, -r0, lsl #22]! │ │ │ │ - tstcs r0, r0, lsr #12 │ │ │ │ - stmib r0, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - stc 0, cr2, [sl, #8] │ │ │ │ - ldrb r0, [r2, -r0, lsl #22]! │ │ │ │ - ldrb r2, [r0, -pc]! │ │ │ │ - tstcs r0, r0, lsr #12 │ │ │ │ - ldmdb r6!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - stc 0, cr2, [sl, #24] │ │ │ │ - strb r0, [r8, -r0, lsl #22]! │ │ │ │ - tstcs r0, r0, lsr #12 │ │ │ │ - stmdb lr!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - stc 0, cr2, [sl, #20] │ │ │ │ - strb r0, [r0, -r0, lsl #22]! │ │ │ │ - strtmi r2, [r0], -r0, lsl #4 │ │ │ │ - @ instruction: 0xf7fc4611 │ │ │ │ - blmi 11417fc <__bss_end__@@Base+0x109abc4> │ │ │ │ - andscs r4, r9, r2, lsl #12 │ │ │ │ - @ instruction: 0xf8c3447b │ │ │ │ - ldrb r2, [r4, -r8, lsl #4] │ │ │ │ + stmdami r4!, {r0, r1, r3, r5, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ + ldrbtmi r4, [r8], #-1569 @ 0xfffff9df │ │ │ │ + bl 1e44b88 <__bss_end__@@Base+0x1d9dfe8> │ │ │ │ + stmdami r2!, {r2, r5, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ + ldrbtmi r4, [r8], #-1569 @ 0xfffff9df │ │ │ │ + stcl 7, cr15, [r6], {252} @ 0xfc │ │ │ │ + stmdami r0!, {r3, r4, r6, r8, r9, ip, sp, pc}^ │ │ │ │ + ldrbtmi r4, [r8], #-1569 @ 0xfffff9df │ │ │ │ + stcl 7, cr15, [r0], {252} @ 0xfc │ │ │ │ + @ instruction: 0xf0002800 │ │ │ │ + ldmdami sp, {r0, r1, r2, r4, r7, pc}^ │ │ │ │ + ldrbtmi r4, [r8], #-1569 @ 0xfffff9df │ │ │ │ + ldc 7, cr15, [r8], #1008 @ 0x3f0 │ │ │ │ + svclt 0x00142800 │ │ │ │ + andscs r2, ip, ip │ │ │ │ + andscs lr, fp, sp, lsl #15 │ │ │ │ + strtmi lr, [r0], -fp, lsl #15 │ │ │ │ + @ instruction: 0xf7fc2100 │ │ │ │ + strdcs lr, [r4], -r6 │ │ │ │ + bleq 42204 │ │ │ │ + strtmi lr, [r0], -r3, lsl #15 │ │ │ │ + @ instruction: 0xf7fc2100 │ │ │ │ + andcs lr, r3, lr, ror #19 │ │ │ │ + bleq 42214 │ │ │ │ + @ instruction: 0x4620e77b │ │ │ │ + @ instruction: 0xf7fc2100 │ │ │ │ + andcs lr, r2, r6, ror #19 │ │ │ │ + bleq 42224 │ │ │ │ + andcs lr, pc, r3, ror r7 @ │ │ │ │ + @ instruction: 0x4620e771 │ │ │ │ + @ instruction: 0xf7fc2100 │ │ │ │ + ldrdcs lr, [r6], -ip │ │ │ │ + bleq 42238 │ │ │ │ + strtmi lr, [r0], -r9, ror #14 │ │ │ │ + @ instruction: 0xf7fc2100 │ │ │ │ + ldrdcs lr, [r5], -r4 │ │ │ │ + bleq 42248 │ │ │ │ + andcs lr, r0, #25427968 @ 0x1840000 │ │ │ │ + ldrmi r4, [r1], -r0, lsr #12 │ │ │ │ + bl 544c1c <__bss_end__@@Base+0x49e07c> │ │ │ │ + strmi r4, [r2], -r0, asr #22 │ │ │ │ + ldrbtmi r2, [fp], #-25 @ 0xffffffe7 │ │ │ │ + @ instruction: 0xe756605a │ │ │ │ strtmi r2, [r0], -r0, lsl #4 │ │ │ │ @ instruction: 0xf7fc4611 │ │ │ │ - blmi 10017e4 <__bss_end__@@Base+0xf5abac> │ │ │ │ + blmi f4186c <__bss_end__@@Base+0xe9accc> │ │ │ │ andscs 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stc 0, cr2, [sl, #28] │ │ │ │ - str r0, [r8, -r0, lsl #22] │ │ │ │ - @ instruction: 0xd01628dc │ │ │ │ - andle r2, ip, r6, ror #17 │ │ │ │ - @ instruction: 0xf47f28d2 │ │ │ │ - qsub16mi sl, r0, r5 │ │ │ │ - @ instruction: 0xf7fc2100 │ │ │ │ - andscs lr, r3, r8, lsl #18 │ │ │ │ - bleq 4242c │ │ │ │ - @ instruction: 0x2011e6f9 │ │ │ │ - @ instruction: 0x4620e6f7 │ │ │ │ + subsvs r4, sl, fp, ror r4 │ │ │ │ + @ instruction: 0x4620e71f │ │ │ │ @ instruction: 0xf7fc2100 │ │ │ │ - @ instruction: 0x2015e8fe │ │ │ │ - bleq 42440 │ │ │ │ - strtmi lr, [r0], -pc, ror #13 │ │ │ │ + andcs lr, r8, sl, lsl #19 │ │ │ │ + bleq 422dc │ │ │ │ + @ instruction: 0x4620e717 │ │ │ │ @ instruction: 0xf7fc2100 │ │ │ │ - @ instruction: 0x2014e8f6 │ │ │ │ - bleq 42450 │ │ │ │ - @ instruction: 0xf7fce6e7 │ │ │ │ - svclt 0x0000eac8 │ │ │ │ - andeq r1, r5, r4, lsr #9 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r4, r5, lr, lsl r5 │ │ │ │ - andeq r1, r5, r2, lsl #8 │ │ │ │ - ldrdeq r1, [r5], -sl │ │ │ │ - andeq r2, r4, r0, ror #28 │ │ │ │ - andeq r2, r4, ip, ror lr │ │ │ │ - andeq r2, r4, ip, ror lr │ │ │ │ - andeq r2, r4, r4, ror lr │ │ │ │ - andeq r4, r5, r0, ror r3 │ │ │ │ - andeq r4, r5, r8, asr r3 │ │ │ │ - andeq r4, r5, r0, asr #6 │ │ │ │ - andeq r4, r5, r8, lsr #6 │ │ │ │ - andeq r4, r5, r0, lsl r3 │ │ │ │ - strdeq r4, [r5], -r8 │ │ │ │ + andcs lr, r7, r2, lsl #19 │ │ │ │ + bleq 422ec │ │ │ │ + ldmcs ip, {r0, r1, r2, r3, r8, r9, sl, sp, lr, pc}^ │ │ │ │ + stmiacs r6!, {r1, r2, r4, ip, lr, pc}^ │ │ │ │ + ldmcs r2, {r2, r3, ip, lr, pc}^ │ │ │ │ + svcge 0x007bf47f │ │ │ │ + tstcs r0, r0, lsr #12 │ │ │ │ + ldmdb r2!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stc 0, cr2, [sl, #76] @ 0x4c │ │ │ │ + str r0, [r0, -r0, lsl #22] │ │ │ │ + usat r2, #30, r1 │ │ │ │ + tstcs r0, r0, lsr #12 │ │ │ │ + stmdb r8!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stc 0, cr2, [sl, #84] @ 0x54 │ │ │ │ + ldrbt r0, [r6], r0, lsl #22 │ │ │ │ + tstcs r0, r0, lsr #12 │ │ │ │ + stmdb r0!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stc 0, cr2, [sl, #80] @ 0x50 │ │ │ │ + strbt r0, [lr], r0, lsl #22 │ │ │ │ + bl d44cfc <__bss_end__@@Base+0xc9e15c> │ │ │ │ + @ instruction: 0x000515b4 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + muleq r5, r6, r5 │ │ │ │ + andeq r1, r5, r6, lsl r5 │ │ │ │ + andeq r1, r5, r6, ror #15 │ │ │ │ + strdeq r2, [r4], -r2 @ │ │ │ │ + andeq r2, r4, lr, lsl #30 │ │ │ │ + andeq r2, r4, lr, lsl #30 │ │ │ │ + andeq r2, r4, r6, lsl #30 │ │ │ │ + andeq r4, r5, lr, ror #7 │ │ │ │ + ldrdeq r4, [r5], -r8 │ │ │ │ + andeq r4, r5, r2, asr #7 │ │ │ │ + andeq r4, r5, ip, lsr #7 │ │ │ │ + muleq r5, r6, r3 │ │ │ │ + andeq r4, r5, r0, lsl #7 │ │ │ │ + svcmi 0x00f0e92d │ │ │ │ + stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ + blhi c2208 <__bss_end__@@Base+0x1b668> │ │ │ │ + @ instruction: 0x0c0cebad │ │ │ │ + svceq 0x00c8f8cc │ │ │ │ + addlt r4, r3, r2, lsr #26 │ │ │ │ + @ instruction: 0xf8dd447d │ │ │ │ + stmib sp, {r2, r3, r4, r5, pc}^ │ │ │ │ + @ instruction: 0xf8d51200 │ │ │ │ + svccs 0x00007208 │ │ │ │ + mrc 13, 5, sp, cr0, cr4, {1} │ │ │ │ + strmi r8, [r6], -r0, asr #22 │ │ │ │ + strcc r4, [r8, #-1691] @ 0xfffff965 │ │ │ │ + beq 42ebc │ │ │ │ + strcc lr, [r4, #-2] │ │ │ │ + strhtle r4, [r9], -sl │ │ │ │ + ldrdls pc, [r0], -r5 │ │ │ │ + @ instruction: 0xf10a4631 │ │ │ │ + @ instruction: 0xf8d90a01 │ │ │ │ + @ instruction: 0xf7fc0000 │ │ │ │ + strmi lr, [r4], -ip, asr #23 │ │ │ │ + mvnsle r2, r0, lsl #16 │ │ │ │ + ldrsbtcs pc, [r0], #-137 @ 0xffffff77 @ │ │ │ │ + vldrle s4, [r9, #-0] │ │ │ │ + ldrsbteq pc, [r4], #-137 @ 0xffffff77 @ │ │ │ │ + @ instruction: 0xf8d8465b │ │ │ │ + cdp 0, 11, cr6, cr0, cr0, {0} │ │ │ │ + bls 49ad8 │ │ │ │ + eoreq pc, r4, r0, asr r8 @ │ │ │ │ + @ instruction: 0xf8c81c71 │ │ │ │ + strcc r1, [r1], #-0 │ │ │ │ + @ instruction: 0xf0029900 │ │ │ │ + @ instruction: 0xf8d5fdfb │ │ │ │ + blls 3aadd0 <__bss_end__@@Base+0x304230> │ │ │ │ + ldrsbtcs pc, [r0], #-137 @ 0xffffff77 @ │ │ │ │ + eoreq pc, r6, r3, asr #16 │ │ │ │ + stclle 2, cr4, [r5], #648 @ 0x288 │ │ │ │ + ldc 0, cr11, [sp], #12 │ │ │ │ + pop {r1, r8, r9, fp, pc} │ │ │ │ + svclt 0x00008ff0 │ │ │ │ + andeq r4, r5, r0, asr #5 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00e8f8cc │ │ │ │ stcls 12, cr4, [r6, #-68] @ 0xffffffbc │ │ │ │ @ instruction: 0xf8d4447c │ │ │ │ ldmdblt pc, {r2, r3, r9, ip, sp, lr} @ │ │ │ │ pop {r1, r2, r8, sl, ip, pc} │ │ │ │ - @ instruction: 0xe65941f0 │ │ │ │ + @ instruction: 0xe61141f0 │ │ │ │ ldrmi r4, [lr], -lr, lsl #13 │ │ │ │ movwcs r4, #1552 @ 0x610 │ │ │ │ andcc pc, ip, #196, 16 @ 0xc40000 │ │ │ │ tstpvc r6, r4, lsl #10 @ p-variant is OBSOLETE │ │ │ │ orrcs lr, r4, #212, 18 @ 0x350000 │ │ │ │ movwcs lr, #2510 @ 0x9ce │ │ │ │ - ldmib lr!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + b 6c4e1c <__bss_end__@@Base+0x61e27c> │ │ │ │ cmppvc r6, r4, lsl #10 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7fc4628 │ │ │ │ - @ instruction: 0xf8d4e9fa │ │ │ │ + @ instruction: 0xf8d4ea16 │ │ │ │ @ instruction: 0xf8d43418 │ │ │ │ eorsvs r0, r3, ip, lsl r4 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ - andeq r4, r5, r8, lsr r2 │ │ │ │ + andeq r4, r5, r0, lsr #4 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00e0f8cc │ │ │ │ - ldrtcc pc, [ip], #2271 @ 0x8df @ │ │ │ │ + ldrtcc pc, [r0], #2271 @ 0x8df @ │ │ │ │ stmiavs r1, {r9, sp}^ │ │ │ │ ldrbtmi fp, [fp], #-130 @ 0xffffff7e │ │ │ │ - ldrtvs pc, [r4], #2271 @ 0x8df @ │ │ │ │ + strtvs pc, [r8], #2271 @ 0x8df │ │ │ │ ldrbtmi r4, [lr], #-1540 @ 0xfffff9fc │ │ │ │ strtcs pc, [r0], #-2243 @ 0xfffff73d │ │ │ │ subsle r2, r4, r0, lsl #18 │ │ │ │ sbcvs r6, r2, r5, lsl #18 │ │ │ │ @ instruction: 0xf0001c6a │ │ │ │ @ instruction: 0xf7fc808d │ │ │ │ - stmdavs r3, {r2, r6, r9, fp, sp, lr, pc} │ │ │ │ + stmdavs r3, {r5, r6, r9, fp, sp, lr, pc} │ │ │ │ andscc pc, r5, r3, lsr r8 @ │ │ │ │ ldrble r0, [r3, #-1375] @ 0xfffffaa1 │ │ │ │ - ldrcs pc, [r0], #2271 @ 0x8df │ │ │ │ + strcs pc, [r4], #2271 @ 0x8df │ │ │ │ @ instruction: 0xf8d2447a │ │ │ │ mrrcne 4, 2, r3, r9, cr0 │ │ │ │ @ instruction: 0xf8c24413 │ │ │ │ @ instruction: 0xf8831420 │ │ │ │ stmiavs r6!, {r2, r5, sl, ip, lr}^ │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ - @ instruction: 0xf8d48098 │ │ │ │ + @ instruction: 0xf8d48096 │ │ │ │ @ instruction: 0x26008010 │ │ │ │ @ instruction: 0xf1b860e6 │ │ │ │ strdle r3, [pc], #-255 @ │ │ │ │ @ instruction: 0xf7fc2701 │ │ │ │ - stmdavs r3, {r1, r2, r5, r9, fp, sp, lr, pc} │ │ │ │ + stmdavs r3, {r1, r6, r9, fp, sp, lr, pc} │ │ │ │ andscc pc, r8, r3, lsr r8 @ │ │ │ │ @ instruction: 0xf100049a │ │ │ │ - @ instruction: 0xf1b880a0 │ │ │ │ + @ instruction: 0xf1b8809e │ │ │ │ mcrrle 15, 4, r0, sl, cr5 │ │ │ │ svceq 0x0027f1b8 │ │ │ │ @ instruction: 0xf1a8dd4b │ │ │ │ - blcs 747bfc <__bss_end__@@Base+0x6a0fc4> │ │ │ │ + blcs 747b7c <__bss_end__@@Base+0x6a0fdc> │ │ │ │ ldm pc, {r0, r1, r2, r6, fp, ip, lr, pc}^ @ │ │ │ │ - addseq pc, r4, r3, lsl r0 @ │ │ │ │ - umaaleq r0, r6, r4, r0 │ │ │ │ - addseq r0, r4, r6, asr #32 │ │ │ │ - tsteq r4, r6, asr #32 │ │ │ │ + addseq pc, r2, r3, lsl r0 @ │ │ │ │ + umaaleq r0, r6, r2, r0 │ │ │ │ + addseq r0, r2, r6, asr #32 │ │ │ │ + tsteq r2, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ subeq r0, r6, r6, asr #32 │ │ │ │ - stmdavs r0!, {r2, r8}^ │ │ │ │ - b 13c4f94 <__bss_end__@@Base+0x131e35c> │ │ │ │ + stmdavs r0!, {r1, r8}^ │ │ │ │ + b 18c4f14 <__bss_end__@@Base+0x181e374> │ │ │ │ stmdacs sl, {r0, r2, r9, sl, lr} │ │ │ │ @ instruction: 0xd1a56120 │ │ │ │ movwcc r6, #6307 @ 0x18a3 │ │ │ │ str r6, [r4, r3, lsr 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<__bss_end__@@Base+0xff9e9bd4> │ │ │ │ @ instruction: 0xf8d2447a │ │ │ │ ldmne r1, {r5, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf8c23301 │ │ │ │ @ instruction: 0xf8813420 │ │ │ │ stmiavs r3!, {r2, r5, sl, pc}^ │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - @ instruction: 0xf8d480a3 │ │ │ │ + @ instruction: 0xf8d480a1 │ │ │ │ movwcs r8, #16 │ │ │ │ @ instruction: 0xf1b860e3 │ │ │ │ @ instruction: 0xd1903fff │ │ │ │ - sub r2, sp, r1 │ │ │ │ + sub r2, fp, r1 │ │ │ │ movwcc r6, #6307 @ 0x18a3 │ │ │ │ - bmi ff85f2b0 <__bss_end__@@Base+0xff7b8678> │ │ │ │ - stmiavs r0!, {r0, r5, r6, r7, r8, r9, fp, lr} │ │ │ │ - ldmpl r1!, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - movweq lr, #2509 @ 0x9cd │ │ │ │ - stmdavs r3!, {r0, r1, r2, r3, r4, r6, r7, r9, fp, lr} │ │ │ │ - ldrbtmi r6, [sl], #-2056 @ 0xfffff7f8 │ │ │ │ - @ instruction: 0xf7fc2101 │ │ │ │ - andcs lr, r1, #212, 18 @ 0x350000 │ │ │ │ + ldmibmi lr, {r0, r1, r5, r7, sp, lr}^ │ │ │ │ + stmiavs r3!, {r1, r2, r3, r4, r6, r7, r9, fp, lr} │ │ │ │ + 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svcge 0x0066f47f │ │ │ │ + stmiavs r3!, {r2, r4, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ ldrtmi r2, [fp], #-1793 @ 0xfffff8ff │ │ │ │ @ instruction: 0xf04f60a3 │ │ │ │ @ instruction: 0xf7fc080a │ │ │ │ - stmdavs r3, {r2, r7, r8, fp, sp, lr, pc} │ │ │ │ + stmdavs r3, {r1, r5, r7, r8, fp, sp, lr, pc} │ │ │ │ ldreq r8, [fp], #2715 @ 0xa9b │ │ │ │ - stclmi 5, cr13, [sl, #708] @ 0x2c4 │ │ │ │ + stclmi 5, cr13, [r8, #716] @ 0x2cc │ │ │ │ tstcs r0, r1, lsl #4 │ │ │ │ ldrbtmi r4, [sp], #-663 @ 0xfffffd69 │ │ │ │ strtcc pc, [r0], #-2261 @ 0xfffff72b │ │ │ │ @ instruction: 0xf883442b │ │ │ │ stmib r4, {r2, r5, sl, ip}^ │ │ │ │ andle r2, ip, r3, lsl #16 │ │ │ │ vcgt.s8 , , q11 │ │ │ │ @ instruction: 0xf5054024 │ │ │ │ @ instruction: 0xf7fb65a6 │ │ │ │ - andcs lr, r8, lr, lsr #31 │ │ │ │ - bleq c24cc <__bss_end__@@Base+0x1b894> │ │ │ │ + andcs lr, r8, sl, asr #31 │ │ │ │ + bleq c2448 <__bss_end__@@Base+0x1b8a8> │ │ │ │ pop {r1, ip, sp, pc} │ │ │ │ - ldcmi 1, cr8, [lr], #960 @ 0x3c0 │ │ │ │ + ldcmi 1, cr8, [ip], #960 @ 0x3c0 │ │ │ │ @ instruction: 0xf8d4447c │ │ │ │ @ instruction: 0xb1b800c0 │ │ │ │ vshl.s8 , q0, │ │ │ │ and r4, r2, r4, lsr #12 │ │ │ │ svceq 0x0008f854 │ │ │ │ ldrtmi fp, [r1], -r0, lsl #3 │ │ │ │ - b 17450cc <__bss_end__@@Base+0x169e494> │ │ │ │ + b 1b45048 <__bss_end__@@Base+0x1a9e4a8> │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ @ instruction: 0xf8c56860 │ │ │ │ strb r4, [r7, r8, lsr #10]! │ │ │ │ - andcs r4, r0, #180, 22 @ 0x2d000 │ │ │ │ + andcs r4, r0, #182272 @ 0x2c800 │ │ │ │ @ instruction: 0xf8d3447b │ │ │ │ strmi r1, [fp], #-1056 @ 0xfffffbe0 │ │ │ │ strtcs pc, [r4], #-2179 @ 0xfffff77d │ │ │ │ andlt r2, r2, r6 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ ldrtmi r2, [r1], -sl, lsl #4 │ │ │ │ eormi pc, r4, r5, lsl #4 │ │ │ │ - stmia r8, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia r6!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ andcs r4, r9, r3, lsl #12 │ │ │ │ strcc pc, [r8, #-2245]! @ 0xfffff73b │ │ │ │ @ instruction: 0xf1a5e7d0 │ │ │ │ - blx fed889d4 <__bss_end__@@Base+0xfece1d9c> │ │ │ │ + blx fed88950 <__bss_end__@@Base+0xfece1db0> │ │ │ │ ldmdbeq r6!, {r1, r2, r7, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - ldrbtmi r4, [sl], #-2727 @ 0xfffff559 │ │ │ │ + ldrbtmi r4, [sl], #-2725 @ 0xfffff55b │ │ │ │ strtcc pc, [r0], #-2258 @ 0xfffff72e │ │ │ │ movwcc r1, #6353 @ 0x18d1 │ │ │ │ strtcc pc, [r0], #-2242 @ 0xfffff73e │ │ │ │ strtpl pc, [r4], #-2177 @ 0xfffff77f │ │ │ │ - blcs 214c4 │ │ │ │ - rschi pc, r1, r0 │ │ │ │ + blcs 21440 │ │ │ │ + sbcshi pc, sp, r0 │ │ │ │ @ instruction: 0x8010f8d4 │ │ │ │ rscvs r2, r3, r0, lsl #6 │ │ │ │ svccc 0x00fff1b8 │ │ │ │ - svcge 0x0066f43f │ │ │ │ - ldrbt r2, [r4], r2, lsl #14 │ │ │ │ + svcge 0x0068f43f │ │ │ │ + ldrbt r2, [r6], r2, lsl #14 │ │ │ │ @ instruction: 0xf7fc6860 │ │ │ │ - @ instruction: 0x4680e976 │ │ │ │ + strmi lr, [r0], ip, lsl #19 │ │ │ │ @ instruction: 0x6120280a │ │ │ │ - rschi pc, fp, r0 │ │ │ │ + rschi pc, r7, r0 │ │ │ │ svccc 0x00fff1b0 │ │ │ │ - mcrge 4, 7, pc, cr9, cr15, {3} @ │ │ │ │ - @ instruction: 0x2601e756 │ │ │ │ - blmi fe580e6c <__bss_end__@@Base+0xfe4da234> │ │ │ │ + mcrge 4, 7, pc, cr11, cr15, {3} @ │ │ │ │ + @ instruction: 0x2601e758 │ │ │ │ + blmi fe500df0 <__bss_end__@@Base+0xfe45a250> │ │ │ │ stccs 2, cr2, [r9, #-0] │ │ │ │ @ instruction: 0xf883447b │ │ │ │ @ instruction: 0xf8835424 │ │ │ │ @ instruction: 0xf0002425 │ │ │ │ - stccs 1, cr8, [ip, #-16]! │ │ │ │ - rscshi pc, sp, r0 │ │ │ │ + stccs 1, cr8, [ip, #-0] │ │ │ │ + rscshi pc, r9, r0 │ │ │ │ @ instruction: 0xf0002d28 │ │ │ │ - bmi fe1a7580 <__bss_end__@@Base+0xfe100948> │ │ │ │ - stmiavs r0!, {r0, r2, r3, r7, r8, r9, fp, lr} │ │ │ │ - ldmpl r1!, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - movweq lr, #2509 @ 0x9cd │ │ │ │ - stmdavs r3!, {r0, r1, r3, r7, r9, fp, lr} │ │ │ │ - ldrbtmi r6, [sl], #-2056 @ 0xfffff7f8 │ │ │ │ - @ instruction: 0xf7fc2101 │ │ │ │ - smlald lr, ip, lr, r9 │ │ │ │ - ldr r2, [r7, r0, lsl #12]! │ │ │ │ - smlawbcs r3, r7, sl, r4 │ │ │ │ + stmibmi r4, {r3, r4, r5, r6, r7, pc} │ │ │ │ + stmiavs r3!, {r0, r1, r3, r7, r9, fp, lr} │ │ │ │ + ldmdapl r1!, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ + stmdavs r8, {r9, ip, pc} │ │ │ │ + stmdavs r2!, {r0, r3, r7, r8, fp, lr} │ │ │ │ + @ instruction: 0xf7fc4479 │ │ │ │ + smlald lr, lr, r8, r9 @ │ │ │ │ + ldr r2, [r9, r0, lsl #12]! │ │ │ │ + smlawbcs r3, r6, sl, r4 │ │ │ │ @ instruction: 0xf8d2447a │ │ │ │ mrrcne 4, 2, r3, r8, cr0 │ │ │ │ @ instruction: 0xf8c24413 │ │ │ │ @ instruction: 0xf8830420 │ │ │ │ stmiavs r3!, {r2, r5, sl, ip}^ │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - stmdbvs r5!, {r1, r2, r3, r4, r5, r7, pc} │ │ │ │ + stmdbvs r5!, {r2, r3, r4, r5, r7, pc} │ │ │ │ rscvs r2, r3, r0, lsl #6 │ │ │ │ @ instruction: 0xf43f1c6b │ │ │ │ - @ instruction: 0xf7fcaf1f │ │ │ │ - stmdavs r2, {r1, r2, r4, r6, r7, fp, sp, lr, pc} │ │ │ │ - @ instruction: 0x46074e7c │ │ │ │ + @ instruction: 0xf7fcaf23 │ │ │ │ + stmdavs r2, {r1, r2, r4, r5, r6, r7, fp, sp, lr, pc} │ │ │ │ + @ instruction: 0x46074e7b │ │ │ │ andscs pc, r5, r2, lsr r8 @ │ │ │ │ ldrbeq r4, [r2], #1150 @ 0x47e │ │ │ │ strtcc pc, [r0], #-2262 @ 0xfffff72a │ │ │ │ - @ instruction: 0xf04fd567 │ │ │ │ + @ instruction: 0xf04fd565 │ │ │ │ and r0, r9, r0, lsl #16 │ │ │ │ @ instruction: 0xf8c46925 │ │ │ │ ldmdavs sl!, {r2, r3, pc} │ │ │ │ strtcc pc, [r0], #-2262 @ 0xfffff72a │ │ │ │ andscs pc, r5, r2, lsr r8 @ │ │ │ │ - ldrble r0, [sl, #-1233] @ 0xfffffb2f │ │ │ │ + ldrble r0, [r8, #-1233] @ 0xfffffb2f │ │ │ │ movwcc r1, #6386 @ 0x18f2 │ │ │ │ strtcc pc, [r0], #-2246 @ 0xfffff73a │ │ │ │ strtpl pc, [r4], #-2178 @ 0xfffff77e │ │ │ │ - blcs 215a8 │ │ │ │ + blcs 21520 │ │ │ │ stmdavs r0!, {r2, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ - stmdb lr, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r6!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ strmi r2, [r5], -sl, lsl #16 │ │ │ │ svclt 0x00026120 │ │ │ │ movwcc r6, #6307 @ 0x18a3 │ │ │ │ strb r6, [r4, r3, lsr #1]! │ │ │ │ - ldrdhi pc, [r0, pc]! @ │ │ │ │ - stclmi 15, cr4, [r9, #-416]! @ 0xfffffe60 │ │ │ │ - ldrbtmi r4, [pc], #-1272 @ 7240 │ │ │ │ + @ instruction: 0x819cf8df │ │ │ │ + stclmi 15, cr4, [r8, #-412]! @ 0xfffffe64 │ │ │ │ + ldrbtmi r4, [pc], #-1272 @ 71b8 │ │ │ │ and r4, pc, sp, ror r4 @ │ │ │ │ @ instruction: 0xf43f280a │ │ │ │ - blmi 19b2dfc <__bss_end__@@Base+0x190c1c4> │ │ │ │ + blmi 1972d84 <__bss_end__@@Base+0x18cc1e4> │ │ │ │ ldrbtmi fp, [fp], #-704 @ 0xfffffd40 │ │ │ │ strtne pc, [r0], #-2259 @ 0xfffff72d │ │ │ │ - mcrrne 10, 6, r4, fp, cr4 │ │ │ │ + mcrrne 10, 6, r4, fp, cr3 │ │ │ │ @ instruction: 0xf8c2447a │ │ │ │ strmi r3, [sl], #-1056 @ 0xfffffbe0 │ │ │ │ strteq pc, [r4], #-2178 @ 0xfffff77e │ │ │ │ - blcs 215f4 │ │ │ │ - stmdbvs r0!, {r1, r3, r4, r5, r6, ip, lr, pc} │ │ │ │ + blcs 2156c │ │ │ │ + stmdbvs r0!, {r3, r4, r5, r6, ip, lr, pc} │ │ │ │ rscvs r2, r2, r0, lsl #4 │ │ │ │ @ instruction: 0xf43f1c42 │ │ │ │ - stmdacs r2!, {r0, r4, r6, r7, r9, sl, fp, sp, pc} │ │ │ │ - svcge 0x0036f43f │ │ │ │ + stmdacs r2!, {r0, r2, r4, r6, r7, r9, sl, fp, sp, pc} │ │ │ │ + svcge 0x0038f43f │ │ │ │ mvnle r2, ip, asr r8 │ │ │ │ - cmplt fp, #14876672 @ 0xe30000 │ │ │ │ + movtlt r6, #47331 @ 0xb8e3 │ │ │ │ movwcs r6, #2336 @ 0x920 │ │ │ │ stmdacs lr!, {r0, r1, r5, r6, r7, sp, lr}^ │ │ │ │ - ldmdacs r4!, {r0, r1, r3, r6, ip, lr, pc}^ │ │ │ │ - mcrrne 0, 4, sp, r3, cr1 │ │ │ │ - blmi 113b7e4 <__bss_end__@@Base+0x1094bac> │ │ │ │ - bmi 150f6a0 <__bss_end__@@Base+0x1468a68> │ │ │ │ - ldmpl r3!, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blmi 14e1304 <__bss_end__@@Base+0x143a6cc> │ │ │ │ - movwls r4, #5243 @ 0x147b │ │ │ │ - movwls r6, #2211 @ 0x8a3 │ │ │ │ - @ instruction: 0xf7fc6823 │ │ │ │ - blmi 144151c <__bss_end__@@Base+0x139a8e4> │ │ │ │ + ldmdacs r4!, {r0, r3, r6, ip, lr, pc}^ │ │ │ │ + mcrrne 0, 3, sp, r3, cr15 │ │ │ │ + blmi 10fb754 <__bss_end__@@Base+0x1054bb4> │ │ │ │ + ldrbtmi r4, [r9], #-2387 @ 0xfffff6ad │ │ │ │ + ldmdavs r8, {r0, r1, r4, r5, r6, r7, fp, ip, lr} │ │ │ │ + ldrbtmi r4, [fp], #-2898 @ 0xfffff4ae │ │ │ │ + stmiavs r3!, {r8, r9, ip, pc} │ │ │ │ + @ instruction: 0xf7fc6822 │ │ │ │ + blmi 1441480 <__bss_end__@@Base+0x139a8e0> │ │ │ │ ldrbtmi r2, [fp], #-255 @ 0xffffff01 │ │ │ │ strtne pc, [r0], #-2259 @ 0xfffff72d │ │ │ │ - strcs lr, [r1], -sl, asr #15 │ │ │ │ - bmi 1380f7c <__bss_end__@@Base+0x12da344> │ │ │ │ + strcs lr, [r1], -ip, asr #15 │ │ │ │ + bmi 1380f00 <__bss_end__@@Base+0x12da360> │ │ │ │ tstcs r0, r1 │ │ │ │ ldrbtmi r6, [sl], #-224 @ 0xffffff20 │ │ │ │ ldrmi r2, [r3], #-2 │ │ │ │ @ instruction: 0xf8836125 │ │ │ │ andlt r1, r2, r4, lsr #8 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ @ instruction: 0xf7fc6860 │ │ │ │ - stmdacs sl, {r4, r5, r7, fp, sp, lr, pc} │ │ │ │ - bicsle r6, r0, r0, lsr #2 │ │ │ │ + stmdacs sl, {r1, r3, r6, r7, fp, sp, lr, pc} │ │ │ │ + bicsle r6, r2, r0, lsr #2 │ │ │ │ movwcc r6, #6307 @ 0x18a3 │ │ │ │ @ instruction: 0xf8d860a3 │ │ │ │ - bl 20c374 <__bss_end__@@Base+0x16573c> │ │ │ │ + bl 20c2e8 <__bss_end__@@Base+0x165748> │ │ │ │ tstcc r1, r1, lsl #6 │ │ │ │ strteq pc, [r4], #-2179 @ 0xfffff77d │ │ │ │ - stmdavs r0!, {r1, r3, r5, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ - ldm lr, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdavs r0!, {r2, r3, r5, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ + ldm r8!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdacs sl, {r7, r9, sl, lr} │ │ │ │ andsle r6, sl, r0, lsr #2 │ │ │ │ svccc 0x00fff1b0 │ │ │ │ - svcge 0x001cf47f │ │ │ │ - @ instruction: 0xf8d5e680 │ │ │ │ + svcge 0x0020f47f │ │ │ │ + @ instruction: 0xf8d5e686 │ │ │ │ andcs r1, r9, #32, 8 @ 0x20000000 │ │ │ │ tstcc r1, fp, ror #16 │ │ │ │ strtcs pc, [r4], #-2179 @ 0xfffff77d │ │ │ │ - @ instruction: 0xf8d7e796 │ │ │ │ + @ instruction: 0xf8d7e798 │ │ │ │ andcs r1, sl, #32, 8 @ 0x20000000 │ │ │ │ tstcc r1, fp, ror r8 │ │ │ │ strtcs pc, [r4], #-2179 @ 0xfffff77d │ │ │ │ - stmiavs r3!, {r1, r2, r3, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ + stmiavs r3!, {r4, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ adcvs r3, r3, r1, lsl #6 │ │ │ │ - sbclt lr, r0, #1061158912 @ 0x3f400000 │ │ │ │ + sbclt lr, r0, #3145728 @ 0x300000 │ │ │ │ stmiavs r3!, {r0, r2, r4, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ movwcc r2, #5890 @ 0x1702 │ │ │ │ - stmdavs r0!, {r1, r2, r4, r7, r9, sl, sp, lr, pc}^ │ │ │ │ - ldmda r8!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdavs r0!, {r1, r3, r4, r7, r9, sl, sp, lr, pc}^ │ │ │ │ + ldm r2, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdacs sl, {r0, r2, r9, sl, lr} │ │ │ │ andsle r6, sl, r0, lsr #2 │ │ │ │ @ instruction: 0xf47f1c68 │ │ │ │ - uasx sl, fp, lr │ │ │ │ + strbt sl, [r1], -r0, asr #30 │ │ │ │ @ instruction: 0xf7fc6860 │ │ │ │ - stmdacs sl, {r1, r2, r3, r5, r6, fp, sp, lr, pc} │ │ │ │ + stmdacs sl, {r3, r7, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf43f6120 │ │ │ │ - mcrrne 14, 5, sl, r1, cr7 │ │ │ │ - mrcge 4, 2, APSR_nzcv, cr2, cr15, {1} │ │ │ │ + mcrrne 14, 5, sl, r1, cr13 │ │ │ │ + mrcge 4, 2, APSR_nzcv, cr8, cr15, {1} │ │ │ │ @ instruction: 0xf43f2822 │ │ │ │ - ldmdacs ip, {r0, r1, r2, r4, r5, r7, r9, sl, fp, sp, pc}^ │ │ │ │ - svcge 0x0065f47f │ │ │ │ - andcs lr, r5, lr, ror r7 │ │ │ │ - mulcs r3, r8, r6 │ │ │ │ - mulcs r4, r6, r6 │ │ │ │ - stmiavs r3!, {r2, r4, r7, r9, sl, sp, lr, pc} │ │ │ │ + ldmdacs ip, {r0, r1, r3, r4, r5, r7, r9, sl, fp, sp, pc}^ │ │ │ │ + svcge 0x0067f47f │ │ │ │ + andcs lr, r5, r0, lsl #15 │ │ │ │ + mulcs r3, ip, r6 │ │ │ │ + mulcs r4, sl, r6 │ │ │ │ + stmiavs r3!, {r3, r4, r7, r9, sl, sp, lr, pc} │ │ │ │ adcvs r3, r3, r1, lsl #6 │ │ │ │ - svclt 0x0000e721 │ │ │ │ - ldrdeq r4, [r5], -r6 │ │ │ │ - andeq r1, r5, r6, lsl r1 │ │ │ │ - andeq r4, r5, r8, lsr #3 │ │ │ │ - andeq r4, r5, r8, asr #1 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r2, r4, ip, asr fp │ │ │ │ - andeq r2, r4, r6, lsl fp │ │ │ │ - andeq r4, r5, r6, lsr #32 │ │ │ │ - andeq r1, r5, r0, lsr #5 │ │ │ │ - andeq r3, r5, ip, asr #31 │ │ │ │ - muleq r5, r6, pc @ │ │ │ │ - andeq r3, r5, r4, asr #30 │ │ │ │ + svclt 0x0000e723 │ │ │ │ + @ instruction: 0x000541be │ │ │ │ + muleq r5, r6, r1 │ │ │ │ + muleq r5, r0, r1 │ │ │ │ + strheq r4, [r5], -r0 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r2, r4, r8, asr fp │ │ │ │ + andeq r2, r4, r4, lsl fp │ │ │ │ + andeq r4, r5, r2, lsl r0 │ │ │ │ + andeq r1, r5, ip, lsl r3 │ │ │ │ + @ instruction: 0x00053fb8 │ │ │ │ + andeq r3, r5, r2, lsl #31 │ │ │ │ + andeq r3, r5, r0, lsr pc │ │ │ │ ldrdeq r2, [r4], -ip │ │ │ │ - andeq r2, r4, sl, lsr #19 │ │ │ │ - andeq r3, r5, r4, lsl #30 │ │ │ │ - ldrdeq r3, [r5], -r0 │ │ │ │ - andeq r3, r5, ip, ror lr │ │ │ │ - andeq r3, r5, sl, ror lr │ │ │ │ - andeq r3, r5, r8, ror lr │ │ │ │ + andeq r2, r4, ip, lsr #19 │ │ │ │ + strdeq r3, [r5], -r4 │ │ │ │ + andeq r3, r5, r0, asr #29 │ │ │ │ + andeq r3, r5, ip, ror #28 │ │ │ │ andeq r3, r5, sl, ror #28 │ │ │ │ - andeq r3, r5, r0, ror #28 │ │ │ │ - @ instruction: 0x000428b0 │ │ │ │ - strdeq r2, [r4], -ip │ │ │ │ - andeq r3, r5, r2, lsl #28 │ │ │ │ - andeq r3, r5, lr, ror #27 │ │ │ │ + andeq r3, r5, r8, ror #28 │ │ │ │ + andeq r3, r5, sl, asr lr │ │ │ │ + andeq r3, r5, r0, asr lr │ │ │ │ + @ instruction: 0x000428b6 │ │ │ │ + andeq r2, r4, r2, lsl #18 │ │ │ │ + strdeq r3, [r5], -r6 │ │ │ │ + andeq r3, r5, r2, ror #27 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb6a020 <__bss_end__@@Base+0xfeac33e8> │ │ │ │ + bl feb69f94 <__bss_end__@@Base+0xfeac33f4> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0x460c0fd8 │ │ │ │ @ instruction: 0xf1004605 │ │ │ │ strtmi r0, [r0], -r8, lsl #2 │ │ │ │ - blvc c2a6c <__bss_end__@@Base+0x1be34> │ │ │ │ - blpl 42a70 │ │ │ │ - blvs 142a74 <__bss_end__@@Base+0x9be3c> │ │ │ │ - blvc 202cc4 <__bss_end__@@Base+0x15c08c> │ │ │ │ - blvc 182c40 <__bss_end__@@Base+0xdc008> │ │ │ │ - blvc 1c2c48 <__bss_end__@@Base+0x11c010> │ │ │ │ - blge ff202ef8 <__bss_end__@@Base+0xff15c2c0> │ │ │ │ - blx ff343446 <__bss_end__@@Base+0xff29c80e> │ │ │ │ + blvc c29e0 <__bss_end__@@Base+0x1be40> │ │ │ │ + blpl 429e4 │ │ │ │ + blvs 1429e8 <__bss_end__@@Base+0x9be48> │ │ │ │ + blvc 202c38 <__bss_end__@@Base+0x15c098> │ │ │ │ + blvc 182bb4 <__bss_end__@@Base+0xdc014> │ │ │ │ + blvc 1c2bbc <__bss_end__@@Base+0x11c01c> │ │ │ │ + blge ff202e6c <__bss_end__@@Base+0xff15c2cc> │ │ │ │ + blx ffa033ba <__bss_end__@@Base+0xff95c81a> │ │ │ │ msreq CPSR_, r5, lsl #2 │ │ │ │ cdp 6, 11, cr4, cr0, cr0, {1} │ │ │ │ @ instruction: 0xf0038b40 │ │ │ │ - strtmi pc, [r0], -r5, asr #23 │ │ │ │ + strtmi pc, [r0], -r0, ror #23 │ │ │ │ teqpeq r8, r5, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - blls 2c2e50 <__bss_end__@@Base+0x21c218> │ │ │ │ - blx fefc3462 <__bss_end__@@Base+0xfef1c82a> │ │ │ │ - blvc 882ad4 <__bss_end__@@Base+0x7dbe9c> │ │ │ │ - blls ff202f2c <__bss_end__@@Base+0xff15c2f4> │ │ │ │ - blx 443024 <__bss_end__@@Base+0x39c3ec> │ │ │ │ + blls 2c2dc4 <__bss_end__@@Base+0x21c224> │ │ │ │ + blx ff6833d6 <__bss_end__@@Base+0xff5dc836> │ │ │ │ + blvc 842a48 <__bss_end__@@Base+0x79bea8> │ │ │ │ + blls ff202ea0 <__bss_end__@@Base+0xff15c300> │ │ │ │ + blx 442f98 <__bss_end__@@Base+0x39c3f8> │ │ │ │ andcs fp, r1, r8, asr #31 │ │ │ │ - ldc 12, cr13, [pc, #100] @ 74cc │ │ │ │ + ldc 12, cr13, [pc, #100] @ 7440 │ │ │ │ vmov.32 r7, d4[1] │ │ │ │ vsqrt.f64 d25, d7 │ │ │ │ svclt 0x0048fa10 │ │ │ │ ldrle r2, [r0], #-0 │ │ │ │ - blhi ff042f50 <__bss_end__@@Base+0xfef9c318> │ │ │ │ - blx 443044 <__bss_end__@@Base+0x39c40c> │ │ │ │ - blls ff042f58 <__bss_end__@@Base+0xfef9c320> │ │ │ │ + blhi ff042ec4 <__bss_end__@@Base+0xfef9c324> │ │ │ │ + blx 442fb8 <__bss_end__@@Base+0x39c418> │ │ │ │ + blls ff042ecc <__bss_end__@@Base+0xfef9c32c> │ │ │ │ mrc 4, 7, sp, cr1, cr4, {0} │ │ │ │ mrc 10, 5, APSR_nzcv, cr5, cr0, {0} │ │ │ │ strle r0, [r7], #-3008 @ 0xfffff440 │ │ │ │ - blx 443058 <__bss_end__@@Base+0x39c420> │ │ │ │ + blx 442fcc <__bss_end__@@Base+0x39c42c> │ │ │ │ andcs fp, r8, ip, asr #30 │ │ │ │ ldc 0, cr2, [sp], #36 @ 0x24 │ │ │ │ vldmdblt r8!, {d8-d10} │ │ │ │ - blhi 1c2798 <__bss_end__@@Base+0x11bb60> │ │ │ │ - blx 44306c <__bss_end__@@Base+0x39c434> │ │ │ │ + blhi 1c270c <__bss_end__@@Base+0x11bb6c> │ │ │ │ + blx 442fe0 <__bss_end__@@Base+0x39c440> │ │ │ │ andcs fp, r6, ip, asr #30 │ │ │ │ ldclt 0, cr2, [r8, #-28]! @ 0xffffffe4 │ │ │ │ - blx 443078 <__bss_end__@@Base+0x39c440> │ │ │ │ - bleq ff042f8c <__bss_end__@@Base+0xfef9c354> │ │ │ │ + blx 442fec <__bss_end__@@Base+0x39c44c> │ │ │ │ + bleq ff042f00 <__bss_end__@@Base+0xfef9c360> │ │ │ │ ldc 4, cr13, [sp], #28 │ │ │ │ vmov.f64 d24, #22 @ 0x40b00000 5.5 │ │ │ │ svclt 0x004cfa10 │ │ │ │ andcs r2, r5, r4 │ │ │ │ mrc 13, 7, fp, cr1, cr8, {1} │ │ │ │ svclt 0x004cfa10 │ │ │ │ andcs r2, r3, r2 │ │ │ │ svclt 0x0000e7e1 │ │ │ │ - andhi pc, r0, pc, lsr #7 │ │ │ │ bicge ip, sl, r3, lsl #1 │ │ │ │ svccc 0x00ebb645 │ │ │ │ bicge ip, sl, r3, lsl #1 │ │ │ │ svclt 0x00ebb645 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb5e6f4 <__bss_end__@@Base+0xfeab7abc> │ │ │ │ + bl feb5e664 <__bss_end__@@Base+0xfeab7ac4> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ strmi r0, [r5], -r8, ror #31 │ │ │ │ movwcs r4, #2083 @ 0x823 │ │ │ │ cmncs r9, r0, lsl #5 │ │ │ │ @ instruction: 0xf00c4478 │ │ │ │ - @ instruction: 0xf105fa71 │ │ │ │ + @ instruction: 0xf105fb25 │ │ │ │ ldmib r5, {r4, r6, sl, fp}^ │ │ │ │ @ instruction: 0xf100231a │ │ │ │ stmdavs r9!, {r4, r6, sl} │ │ │ │ andvs r4, r1, r7, lsl #12 │ │ │ │ tstcs sl, #192, 18 @ 0x300000 │ │ │ │ @ instruction: 0x000fe8bc │ │ │ │ - strgt r6, [pc], #-3886 @ 7528 │ │ │ │ + strgt r6, [pc], #-3886 @ 7498 │ │ │ │ ldm ip, {r9, sl, fp, sp} │ │ │ │ stm r4, {r0, r1} │ │ │ │ stcle 0, cr0, [sp, #-12] │ │ │ │ svcvs 0x006b2400 │ │ │ │ eoreq pc, r4, r3, asr r8 @ │ │ │ │ - blx 6c3548 <__bss_end__@@Base+0x61c910> │ │ │ │ + @ instruction: 0xf9c6f002 │ │ │ │ orrlt r4, r0, r3, lsl #12 │ │ │ │ strcc r6, [r1], #-3886 @ 0xfffff0d2 │ │ │ │ ldclle 2, cr4, [r4], #664 @ 0x298 │ │ │ │ ldcle 14, cr2, [r3], {-0} │ │ │ │ movwcs r4, #2063 @ 0x80f │ │ │ │ ldrhcs r0, [r8, r2]! │ │ │ │ @ instruction: 0xf00c4478 │ │ │ │ - stmib r7, {r0, r1, r2, r6, r9, fp, ip, sp, lr, pc}^ │ │ │ │ + stmib r7, {r0, r1, r3, r4, r5, r6, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x4638601c │ │ │ │ - bmi 2f6d48 <__bss_end__@@Base+0x250110> │ │ │ │ + bmi 2f6cb8 <__bss_end__@@Base+0x250118> │ │ │ │ stmdami fp, {r0, r7, r8, sp} │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - @ instruction: 0xf95af00b │ │ │ │ - stcl 7, cr15, [r8], #1004 @ 0x3ec │ │ │ │ + ldc2l 0, cr15, [sl, #-44] @ 0xffffffd4 │ │ │ │ + stc 7, cr15, [r8, #-1004] @ 0xfffffc14 │ │ │ │ movwcs r4, #2568 @ 0xa08 │ │ │ │ orrcs r4, fp, r8, lsl #16 │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - @ instruction: 0xf950f00b │ │ │ │ - ldcl 7, cr15, [lr], {251} @ 0xfb │ │ │ │ - @ instruction: 0x000426b4 │ │ │ │ - andeq r2, r4, r0, ror #12 │ │ │ │ - andeq r2, r4, ip, asr r6 │ │ │ │ - andeq r2, r4, sl, asr #12 │ │ │ │ + ldc2l 0, cr15, [r0, #-44] @ 0xffffffd4 │ │ │ │ + ldcl 7, cr15, [lr], #1004 @ 0x3ec │ │ │ │ + andeq r2, r4, r0, asr #13 │ │ │ │ andeq r2, r4, ip, ror #12 │ │ │ │ - andeq r2, r4, r6, lsr r6 │ │ │ │ + andeq r2, r4, r4, ror #12 │ │ │ │ + andeq r2, r4, r6, asr r6 │ │ │ │ + andeq r2, r4, r4, ror r6 │ │ │ │ + andeq r2, r4, r2, asr #12 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb5e7ac <__bss_end__@@Base+0xfeab7b74> │ │ │ │ + bl feb5e71c <__bss_end__@@Base+0xfeab7b7c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ svcvs 0x00020ff0 │ │ │ │ - bcs 18dcc │ │ │ │ + bcs 18d3c │ │ │ │ strcs sp, [r0], #-3344 @ 0xfffff2f0 │ │ │ │ @ instruction: 0xf8536f6b │ │ │ │ cmplt r3, r4, lsr #32 │ │ │ │ @ instruction: 0xf00c6a18 │ │ │ │ - svcvs 0x006bfac1 │ │ │ │ + svcvs 0x006bfb75 │ │ │ │ eoreq pc, r4, r3, asr r8 @ │ │ │ │ - blx fef43604 <__bss_end__@@Base+0xfee9c9cc> │ │ │ │ + blx 1c43576 <__bss_end__@@Base+0x1b9c9d6> │ │ │ │ strcc r6, [r1], #-3882 @ 0xfffff0d6 │ │ │ │ - stclle 2, cr4, [pc], #648 @ 7864 │ │ │ │ + stclle 2, cr4, [pc], #648 @ 77d4 │ │ │ │ @ instruction: 0xf00c6fa8 │ │ │ │ - svcvs 0x0068fab5 │ │ │ │ - blx fecc3618 <__bss_end__@@Base+0xfec1c9e0> │ │ │ │ + svcvs 0x0068fb69 │ │ │ │ + blx 19c358a <__bss_end__@@Base+0x191c9ea> │ │ │ │ @ instruction: 0xf00c6828 │ │ │ │ - strtmi pc, [r8], -pc, lsr #21 │ │ │ │ + strtmi pc, [r8], -r3, ror #22 │ │ │ │ ldrhtmi lr, [r8], -sp │ │ │ │ - blt feac3628 <__bss_end__@@Base+0xfea1c9f0> │ │ │ │ + bllt 17c3598 <__bss_end__@@Base+0x171c9f8> │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00e8f8cc │ │ │ │ ldrsbthi pc, [r0], pc @ │ │ │ │ movwcs r4, #1541 @ 0x605 │ │ │ │ ldrbtmi r2, [r8], #640 @ 0x280 │ │ │ │ @ instruction: 0x464021d6 │ │ │ │ ldrbeq pc, [r0], -r5, lsl #2 @ │ │ │ │ - @ instruction: 0xf9e6f00c │ │ │ │ + blx fe6c35c0 <__bss_end__@@Base+0xfe61ca20> │ │ │ │ andvs r6, r3, fp, lsr #16 │ │ │ │ ldmib r5, {r0, r1, r2, r9, sl, lr}^ │ │ │ │ stmib r0, {r1, r3, r4, r8, r9, sp}^ │ │ │ │ @ instruction: 0xf100231a │ │ │ │ @ instruction: 0xf8d50450 │ │ │ │ mcrgt 0, 0, ip, cr15, cr0, {3} │ │ │ │ movwcs ip, #1039 @ 0x40f │ │ │ │ addeq lr, ip, #323584 @ 0x4f000 │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, r4, lsl #17 │ │ │ │ @ instruction: 0x464021db │ │ │ │ rsbsgt pc, r0, r7, asr #17 │ │ │ │ - @ instruction: 0xf9ccf00c │ │ │ │ + blx fe0435f4 <__bss_end__@@Base+0xfdf9ca54> │ │ │ │ ldrbvs r6, [r8, -fp, lsr #31]! │ │ │ │ svcvs 0x003ab32b │ │ │ │ bicscs r2, sp, r4, lsl r4 │ │ │ │ movwcs r4, #1600 @ 0x640 │ │ │ │ vqdmulh.s d15, d2, d4 │ │ │ │ - @ instruction: 0xf9c0f00c │ │ │ │ + blx 1d4360c <__bss_end__@@Base+0x1c9ca6c> │ │ │ │ @ instruction: 0x67b86f3a │ │ │ │ - blx 12351a <__bss_end__@@Base+0x7c8e2> │ │ │ │ + blx 12348a <__bss_end__@@Base+0x7c8ea> │ │ │ │ @ instruction: 0xf7fbf202 │ │ │ │ - svcvs 0x002bedda │ │ │ │ + svcvs 0x002bedfe │ │ │ │ svclt 0x00c82b00 │ │ │ │ stcle 4, cr2, [sp, #-0] │ │ │ │ svcvs 0x007e6f6b │ │ │ │ eoreq pc, r4, r3, asr r8 @ │ │ │ │ - @ instruction: 0xf972f002 │ │ │ │ + @ instruction: 0xf91ef002 │ │ │ │ @ instruction: 0xf8464603 │ │ │ │ cmplt r0, r4, lsr #32 │ │ │ │ strcc r6, [r1], #-3883 @ 0xfffff0d5 │ │ │ │ ldclle 2, cr4, [r1], #652 @ 0x28c │ │ │ │ pop {r3, r4, r5, r9, sl, lr} │ │ │ │ @ instruction: 0x67bb81f0 │ │ │ │ - bmi 181648 <__bss_end__@@Base+0xdaa10> │ │ │ │ + bmi 1815b8 <__bss_end__@@Base+0xdaa18> │ │ │ │ stmdami r5, {r0, r1, r3, r5, r6, r7, r8, sp} │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - @ instruction: 0xf8b8f00b │ │ │ │ - mcrr 7, 15, pc, r6, cr11 @ │ │ │ │ - andeq r2, r4, r6, lsr #11 │ │ │ │ - andeq r2, r4, r4, asr #10 │ │ │ │ - andeq r2, r4, r6, lsl #10 │ │ │ │ + ldc2 0, cr15, [r8], #44 @ 0x2c │ │ │ │ + stcl 7, cr15, [r6], #-1004 @ 0xfffffc14 │ │ │ │ + @ instruction: 0x000425b2 │ │ │ │ + andeq r2, r4, ip, asr #10 │ │ │ │ + andeq r2, r4, r2, lsl r5 │ │ │ │ strmi r6, [r2], -r3, lsl #31 │ │ │ │ andcs fp, r0, fp, lsl #2 │ │ │ │ svcvs 0x00004770 │ │ │ │ andle r2, ip, r0, lsl #16 │ │ │ │ ldclle 15, cr6, [r8, #328]! @ 0x148 │ │ │ │ and r3, r1, r4, lsl #20 │ │ │ │ smlalsle r4, r4, r8, r2 @ │ │ │ │ svcne 0x0004f852 │ │ │ │ - bvs fe2542f0 <__bss_end__@@Base+0xfe1ad6b8> │ │ │ │ + bvs fe254260 <__bss_end__@@Base+0xfe1ad6c0> │ │ │ │ rscsle r2, r7, r0, lsl #18 │ │ │ │ ldrbmi r2, [r0, -r1]! │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stceq 0, cr15, [r0], {79} @ 0x4f │ │ │ │ cdpmi 4, 4, cr15, cr0, cr15, {2} │ │ │ │ - blhi c2bb8 <__bss_end__@@Base+0x1bf80> │ │ │ │ + blhi c2b28 <__bss_end__@@Base+0x1bf88> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ vmlaeq.f64 d14, d30, d28 │ │ │ │ stcpl 5, cr15, [r0], {172} @ 0xac │ │ │ │ andeq pc, r0, ip, asr #17 │ │ │ │ ldrshle r4, [r9, #84]! @ 0x54 │ │ │ │ ldcleq 8, cr15, [r0], #312 @ 0x138 │ │ │ │ - bmi 1f9b514 <__bss_end__@@Base+0x1ef48dc> │ │ │ │ + bmi 1f9b484 <__bss_end__@@Base+0x1ef48e4> │ │ │ │ stclmi 5, cr15, [r0, #-692] @ 0xfffffd4c │ │ │ │ adcslt r4, r1, pc, ror r4 │ │ │ │ @ instruction: 0xf50d4605 │ │ │ │ @ instruction: 0xf10c4c40 │ │ │ │ ldrcs r0, [r4], #-3260 @ 0xfffff344 │ │ │ │ movwcs r5, #2234 @ 0x8ba │ │ │ │ vst2.16 {d20-d21}, [pc :256], r8 │ │ │ │ ldmdavs r2, {r0, r1, r3, r7, r8, ip, sp, lr} │ │ │ │ andcs pc, r0, ip, asr #17 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ cdpmi 15, 7, cr6, cr5, cr10, {1} │ │ │ │ @ instruction: 0xf04f4478 │ │ │ │ @ instruction: 0xf10d0800 │ │ │ │ ldrbtmi r0, [lr], #-2848 @ 0xfffff4e0 │ │ │ │ - blhi 1b42dd8 <__bss_end__@@Base+0x1a9c1a0> │ │ │ │ + blhi 1b42d48 <__bss_end__@@Base+0x1a9c1a8> │ │ │ │ vqdmulh.s d15, d2, d4 │ │ │ │ @ instruction: 0xf00cac30 │ │ │ │ - blmi 1c05c74 <__bss_end__@@Base+0x1b5f03c> │ │ │ │ + blmi 1c05eb4 <__bss_end__@@Base+0x1b5f314> │ │ │ │ ldmpl r7!, {r3, r5, r7, r8, r9, sl, sp, lr}^ │ │ │ │ - blge b2fa8 <__bss_end__@@Base+0xc370> │ │ │ │ + blge b2f18 <__bss_end__@@Base+0xc378> │ │ │ │ ldrtmi r9, [r0], -r1, lsl #6 │ │ │ │ - blx fe7c3784 <__bss_end__@@Base+0xfe71cb4c> │ │ │ │ + blx ff6c36f4 <__bss_end__@@Base+0xff61cb54> │ │ │ │ ldc 1, cr2, [r7, #8] │ │ │ │ ldrtmi r0, [r0], -r2, lsl #22 │ │ │ │ - blx fffc3792 <__bss_end__@@Base+0xfff1cb5a> │ │ │ │ + mrrc2 0, 0, pc, pc, cr3 @ │ │ │ │ ldc 1, cr2, [r7, #12] │ │ │ │ ldrtmi r0, [r0], -r0, lsl #22 │ │ │ │ - blx ffe4379e <__bss_end__@@Base+0xffd9cb66> │ │ │ │ - blvc 6c2de8 <__bss_end__@@Base+0x61c1b0> │ │ │ │ - blvs 143260 <__bss_end__@@Base+0x9c628> │ │ │ │ + mrrc2 0, 0, pc, r9, cr3 @ │ │ │ │ + blvc 6c2d58 <__bss_end__@@Base+0x61c1b8> │ │ │ │ + blvs 1431d0 <__bss_end__@@Base+0x9c630> │ │ │ │ ldrbmi r9, [sl], -r1, lsl #16 │ │ │ │ mcr 6, 1, r4, cr7, cr1, {1} │ │ │ │ vstr d7, [r4, #-24] @ 0xffffffe8 │ │ │ │ vstr d8, [r4, #-168] @ 0xffffff58 │ │ │ │ vstr d8, [r4, #-176] @ 0xffffff50 │ │ │ │ @ instruction: 0xf0037b2e │ │ │ │ - ldmib r5, {r0, r1, r3, r4, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmib r5, {r0, r1, r3, r4, r5, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf1b9931c │ │ │ │ stclle 15, cr0, [ip, #-0] │ │ │ │ @ instruction: 0xf1a32000 │ │ │ │ strtmi r0, [r3], -r4, lsl #28 │ │ │ │ - blcs a42c18 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@ instruction: 0xf50dd123 │ │ │ │ eorslt r4, r1, r0, asr #26 │ │ │ │ - blhi c2bbc <__bss_end__@@Base+0x1bf84> │ │ │ │ + blhi c2b2c <__bss_end__@@Base+0x1bf8c> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf04f4623 │ │ │ │ and r0, r3, r0, lsl #16 │ │ │ │ @ instruction: 0x4698691a │ │ │ │ ldrmi fp, [r3], -r2, lsl #3 │ │ │ │ - blvc c2f2c <__bss_end__@@Base+0x1c2f4> │ │ │ │ - blvc ff1833b4 <__bss_end__@@Base+0xff0dc77c> │ │ │ │ - blx 4434ac <__bss_end__@@Base+0x39c874> │ │ │ │ + blvc c2e9c <__bss_end__@@Base+0x1c2fc> │ │ │ │ + blvc ff183324 <__bss_end__@@Base+0xff0dc784> │ │ │ │ + blx 44341c <__bss_end__@@Base+0x39c87c> │ │ │ │ @ instruction: 0xf1b8d5f4 │ │ │ │ andle r0, r8, r0, lsl #30 │ │ │ │ @ instruction: 0x3010f8d8 │ │ │ │ @ instruction: 0xf8c8610b │ │ │ │ @ instruction: 0xe7b41010 │ │ │ │ tstvs sl, r9, lsl r1 │ │ │ │ @ instruction: 0x461ce7b1 │ │ │ │ @ instruction: 0xf7fbe7ad │ │ │ │ - svclt 0x0000ed5a │ │ │ │ + svclt 0x0000ed7e │ │ │ │ ... │ │ │ │ - ldrdeq r0, [r5], -ip │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r2, r4, ip, ror #8 │ │ │ │ - andeq r0, r5, sl, lsr #17 │ │ │ │ - ldrdeq r0, [r0], -r4 │ │ │ │ - andeq r0, r5, r2, asr r7 │ │ │ │ + andeq r0, r5, ip, ror #18 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r2, r4, r8, ror r4 │ │ │ │ + andeq r0, r5, sl, lsr r9 │ │ │ │ + andeq r0, r0, ip, asr #5 │ │ │ │ + andeq r0, r5, r2, ror #15 │ │ │ │ strlt r4, [r0, #-1668] @ 0xfffff97c │ │ │ │ @ instruction: 0xe018f8df │ │ │ │ @ instruction: 0x000fe8bc │ │ │ │ stmia lr!, {r1, r2, r3, r4, r5, r6, r7, sl, lr} │ │ │ │ ldm ip, {r0, r1, r2, r3} │ │ │ │ stm lr, {r0, r1} │ │ │ │ @ instruction: 0xf85d0003 │ │ │ │ svclt 0x0000fb04 │ │ │ │ - andeq r0, r5, r0, lsl sl │ │ │ │ + muleq r5, r8, sl │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00b8f8cc │ │ │ │ - tstmi ip, #3424256 @ 0x344000 │ │ │ │ - strmi fp, [sl], r9, lsl #1 │ │ │ │ - stccs 6, cr4, [r0], {6} │ │ │ │ - adcshi pc, pc, r0, asr #6 │ │ │ │ - addeq lr, r4, r3, lsl #22 │ │ │ │ - @ instruction: 0xf8532200 │ │ │ │ - addmi r1, r3, #4, 22 @ 0x1000 │ │ │ │ + andsmi lr, ip, #3424256 @ 0x344000 │ │ │ │ + strmi fp, [r9], r9, lsl #1 │ │ │ │ + stccs 6, cr4, [r0], {5} │ │ │ │ + adcshi pc, r5, r0, asr #6 │ │ │ │ + addeq lr, r4, r2, lsl #22 │ │ │ │ + @ instruction: 0xf8522300 │ │ │ │ + addmi r1, r2, #4, 22 @ 0x1000 │ │ │ │ @ instruction: 0x1002f9b1 │ │ │ │ - mvnsle r4, sl, lsl #8 │ │ │ │ - ldrdcc pc, [r0], -sl │ │ │ │ - stmib sp, {r0, r8, sp}^ │ │ │ │ - ldrtmi r2, [r0], -r0, lsl #8 │ │ │ │ - ldrbtmi r4, [sl], #-2648 @ 0xfffff5a8 │ │ │ │ + mvnsle r4, fp, lsl #8 │ │ │ │ + @ instruction: 0x46284956 │ │ │ │ + ldrdcs pc, [r0], -r9 │ │ │ │ + strls r4, [r0], #-1145 @ 0xfffffb87 │ │ │ │ stc 7, cr15, [r6, #-1004]! @ 0xfffffc14 │ │ │ │ - tstcs ip, #3571712 @ 0x368000 │ │ │ │ - vldmdble pc!, {s5-s4} │ │ │ │ - ldrsbls pc, [r4, #-143] @ 0xffffff71 @ │ │ │ │ - stmdaeq r4, {r0, r1, r5, r7, r8, ip, sp, lr, pc} │ │ │ │ + tstcs ip, #3555328 @ 0x364000 │ │ │ │ + vldmdble fp!, {s5-s4} │ │ │ │ + ldrdhi pc, [r4, #-143] @ 0xffffff71 │ │ │ │ + bleq 143fa0 <__bss_end__@@Base+0x9d400> │ │ │ │ @ instruction: 0xf04f2701 │ │ │ │ - ldrbtmi r0, [r9], #2816 @ 0xb00 │ │ │ │ - svccc 0x0004f858 │ │ │ │ + ldrbtmi r0, [r8], #2560 @ 0xa00 │ │ │ │ + svccc 0x0004f85b │ │ │ │ @ instruction: 0x1002f9b3 │ │ │ │ stmdbcs r0, {r2, r3, r4, r9, fp, sp, lr} │ │ │ │ - ldrcc sp, [r8], #-3358 @ 0xfffff2e2 │ │ │ │ - ldc 5, cr2, [r4, #-0] │ │ │ │ - ldrtmi r7, [fp], -r2, lsl #22 │ │ │ │ - tstcs r1, sl, asr #12 │ │ │ │ - strcc r4, [r1, #-1584] @ 0xfffff9d0 │ │ │ │ - blvc 143008 <__bss_end__@@Base+0x9c3d0> │ │ │ │ - ldc 7, cr3, [r4, #-4] │ │ │ │ - ldrcc r7, [r8], #-2820 @ 0xfffff4fc │ │ │ │ - blvc c3014 <__bss_end__@@Base+0x1c3dc> │ │ │ │ - blvc 342e34 <__bss_end__@@Base+0x29c1fc> │ │ │ │ - blvc 4301c │ │ │ │ - ldcl 7, cr15, [ip], #1004 @ 0x3ec │ │ │ │ - ldrdcc pc, [r0], -r8 │ │ │ │ - @ instruction: 0x3002f9b3 │ │ │ │ - stclle 2, cr4, [r4], #684 @ 0x2ac │ │ │ │ - ldrsbtcs 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+ ldmdavs r3!, {r2, r4, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6a98 │ │ │ │ - ldmdavs ip!, {r0, r2, r3, fp, ip, sp, lr, pc} │ │ │ │ - strmi r4, [r3], -lr, lsr #20 │ │ │ │ - @ instruction: 0xf9b42101 │ │ │ │ - ldrbtmi r0, [sl], #-2 │ │ │ │ - ldrtmi r9, [r0], -r0 │ │ │ │ - stcl 7, cr15, [r2], {251} @ 0xfb │ │ │ │ - @ instruction: 0xf9b3683b │ │ │ │ - blcs 13a70 │ │ │ │ - @ instruction: 0xf8dfdd10 │ │ │ │ - strcs r8, [r0], #-160 @ 0xffffff60 │ │ │ │ - @ instruction: 0x462b44f8 │ │ │ │ - strbmi r2, [r2], -r1, lsl #2 │ │ │ │ - strmi r4, [sp], #-1584 @ 0xfffff9d0 │ │ │ │ - ldc 7, cr15, [r2], #1004 @ 0x3ec │ │ │ │ - strcc r6, [r1], #-2107 @ 0xfffff7c5 │ │ │ │ + ldmdavs r3!, {r0, r2, r5, fp, ip, sp, lr, pc} │ │ │ │ + strmi r4, [r2], -fp, lsr #18 │ │ │ │ + @ instruction: 0xf9b34628 │ │ │ │ + ldrbtmi r3, [r9], #-2 │ │ │ │ + stcl 7, cr15, [r6], {251} @ 0xfb │ │ │ │ + @ instruction: 0xf9b36833 │ │ │ │ + blcs 139d4 │ │ │ │ + svcmi 0x0026dd10 │ │ │ │ + bleq 43b10 │ │ │ │ + @ instruction: 0x4622447f │ │ │ │ + @ instruction: 0x46284639 │ │ │ │ + bleq 83e0c <__bss_start@@Base+0x28e04> │ │ │ │ + ldc 7, cr15, [r6], #1004 @ 0x3ec │ │ │ │ + strcc r6, [r1], #-2099 @ 0xfffff7cd │ │ │ │ @ instruction: 0x3002f9b3 │ │ │ │ - ldclle 2, cr4, [r2], #652 @ 0x28c │ │ │ │ - andcs r4, sl, r1, lsr r6 │ │ │ │ - ldc 7, cr15, [r8], #1004 @ 0x3ec │ │ │ │ - ldrsbtcc pc, [r0], #-138 @ 0xffffff76 @ │ │ │ │ - stmdbeq r1, {r0, r3, r8, ip, sp, lr, pc} │ │ │ │ - stclle 5, cr4, [r2], {75} @ 0x4b │ │ │ │ - @ instruction: 0xf7fb4630 │ │ │ │ - stmdacc r0, {r1, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ + ldclle 5, cr4, [r2], #364 @ 0x16c │ │ │ │ + andcs r4, sl, r9, lsr #12 │ │ │ │ + ldcl 7, cr15, [sl], {251} @ 0xfb │ │ │ │ + ldrsbtcc pc, [r0], #-137 @ 0xffffff77 @ │ │ │ │ + stmdaeq r1, {r3, r8, ip, sp, lr, pc} │ │ │ │ + stclle 5, cr4, [r5], {67} @ 0x43 │ │ │ │ + @ instruction: 0xf7fb4628 │ │ │ │ + stmdacc r0, {r2, r5, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ andlt r4, r9, r0, asr #4 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ bfieq r8, fp, #16, #12 │ │ │ │ - @ instruction: 0xf7fed50c │ │ │ │ - ldmdavs sl!, {r0, r1, r4, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - tstcs r1, r3, lsl #12 │ │ │ │ - @ instruction: 0xf9b24630 │ │ │ │ - andls r2, r0, #2 │ │ │ │ - @ instruction: 0xf7fb9a07 │ │ │ │ - strb lr, [r5, sl, lsl #25] │ │ │ │ - @ instruction: 0xffc6f7fe │ │ │ │ - @ instruction: 0x4603683a │ │ │ │ - ldrtmi r2, [r0], -r1, lsl #2 │ │ │ │ - @ instruction: 0x2002f9b2 │ │ │ │ - bls 1ac2e8 <__bss_end__@@Base+0x1056b0> │ │ │ │ - ldcl 7, cr15, [ip], #-1004 @ 0xfffffc14 │ │ │ │ - andcs lr, r0, #184, 14 @ 0x2e00000 │ │ │ │ - svclt 0x0000e748 │ │ │ │ - andeq r2, r4, r6, lsl #5 │ │ │ │ - andeq r2, r4, r6, ror r2 │ │ │ │ - andeq r2, r4, sl, lsr r2 │ │ │ │ - andeq r2, r4, r4, lsl r2 │ │ │ │ - andeq r2, r4, lr, lsl r2 │ │ │ │ - andeq r2, r4, r2, ror #3 │ │ │ │ - andeq r2, r4, r4, lsl #29 │ │ │ │ - blvc ec3190 <__bss_end__@@Base+0xe1c558> │ │ │ │ + @ instruction: 0xf7fed50a │ │ │ │ + ldmdavs r3!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + stmdbls r7, {r1, r9, sl, lr} │ │ │ │ + @ instruction: 0xf9b34628 │ │ │ │ + @ instruction: 0xf7fb3002 │ │ │ │ + bfi lr, r0, (invalid: 25:7) │ │ │ │ + @ instruction: 0xffe2f7fe │ │ │ │ + @ instruction: 0x46026833 │ │ │ │ + strtmi r9, [r8], -r6, lsl #18 │ │ │ │ + @ instruction: 0x3002f9b3 │ │ │ │ + stc 7, cr15, [r4], {251} @ 0xfb │ │ │ │ + movwcs lr, #1980 @ 0x7bc │ │ │ │ + svclt 0x0000e752 │ │ │ │ + muleq r4, r4, r2 │ │ │ │ + andeq r2, r4, r2, lsl #5 │ │ │ │ + andeq r2, r4, r8, asr #4 │ │ │ │ + andeq r2, r4, r2, lsr #4 │ │ │ │ + andeq r2, r4, ip, lsr #4 │ │ │ │ + strdeq r2, [r4], -r2 @ │ │ │ │ + andeq r3, r4, r4, ror #1 │ │ │ │ + blvc f030ec <__bss_end__@@Base+0xe5c54c> │ │ │ │ ldrblt r6, [r0, #-3843]! @ 0xfffff0fd │ │ │ │ vstr d2, [r0] │ │ │ │ vstmdble r4!, {d23-} │ │ │ │ cdp 15, 11, cr6, cr0, cr5, {2} │ │ │ │ vmov.f64 d6, d7 │ │ │ │ strcs r5, [r0], #-2887 @ 0xfffff4b9 │ │ │ │ ssatmi r2, #13, r8, lsl #12 │ │ │ │ vdiveq.f64 d14, d3, d5 │ │ │ │ - blcc 145ca8 <__bss_end__@@Base+0x9f070> │ │ │ │ + blcc 145c04 <__bss_end__@@Base+0x9f064> │ │ │ │ @ instruction: 0x1002f9b3 │ │ │ │ svclt 0x00c42900 │ │ │ │ - blx 4623b2 <__bss_end__@@Base+0x3bb77a> │ │ │ │ - stcle 2, cr3, [pc, #-24] @ 7b30 │ │ │ │ - blcs 43198 │ │ │ │ + blx 46230e <__bss_end__@@Base+0x3bb76e> │ │ │ │ + stcle 2, cr3, [pc, #-24] @ 7a8c │ │ │ │ + blcs 430f4 │ │ │ │ ldc 3, cr3, [r3, #-96] @ 0xffffffa0 │ │ │ │ vldr d3, [r3, #-16] │ │ │ │ addsmi r4, sl, #2048 @ 0x800 │ │ │ │ - blpl c3430 <__bss_end__@@Base+0x1c7f8> │ │ │ │ - blvs 103438 <__bss_end__@@Base+0x5c800> │ │ │ │ - blvc 143440 <__bss_end__@@Base+0x9c808> │ │ │ │ + blpl c338c <__bss_end__@@Base+0x1c7ec> │ │ │ │ + blvs 103394 <__bss_end__@@Base+0x5c7f4> │ │ │ │ + blvc 14339c <__bss_end__@@Base+0x9c7fc> │ │ │ │ strmi sp, [ip], #-496 @ 0xfffffe10 │ │ │ │ mvnle r4, r6, ror #11 │ │ │ │ cdp 3, 0, cr11, cr4, cr12, {7} │ │ │ │ @ instruction: 0x21184a90 │ │ │ │ - blne ff943658 <__bss_end__@@Base+0xff89ca20> │ │ │ │ - blcs 83590 <__bss_start@@Base+0x284f0> │ │ │ │ - blcc 83598 <__bss_start@@Base+0x284f8> │ │ │ │ - blmi 835a0 <__bss_start@@Base+0x28500> │ │ │ │ - blcs 543188 <__bss_end__@@Base+0x49c550> │ │ │ │ - blcc 5c318c <__bss_end__@@Base+0x51c554> │ │ │ │ - blmi 643190 <__bss_end__@@Base+0x59c558> │ │ │ │ - blcc 145ce8 <__bss_end__@@Base+0x9f0b0> │ │ │ │ + blne ff9435b4 <__bss_end__@@Base+0xff89ca14> │ │ │ │ + blcs 834ec <__bss_start@@Base+0x284e4> │ │ │ │ + blcc 834f4 <__bss_start@@Base+0x284ec> │ │ │ │ + blmi 834fc <__bss_start@@Base+0x284f4> │ │ │ │ + blcs 5430e4 <__bss_end__@@Base+0x49c544> │ │ │ │ + blcc 5c30e8 <__bss_end__@@Base+0x51c548> │ │ │ │ + blmi 6430ec <__bss_end__@@Base+0x59c54c> │ │ │ │ + blcc 145c44 <__bss_end__@@Base+0x9f0a4> │ │ │ │ @ instruction: 0x2002f9b3 │ │ │ │ svclt 0x00c42a00 │ │ │ │ - blx 4a240e <__bss_end__@@Base+0x3fb7d6> │ │ │ │ - ldcle 2, cr3, [pc, #-4] @ 7ba0 │ │ │ │ - blvc c31f4 <__bss_end__@@Base+0x1c5bc> │ │ │ │ + blx 4a236a <__bss_end__@@Base+0x3fb7ca> │ │ │ │ + ldcle 2, cr3, [pc, #-4] @ 7afc │ │ │ │ + blvc c3150 <__bss_end__@@Base+0x1c5b0> │ │ │ │ ldc 3, cr3, [r3, #-96] @ 0xffffffa0 │ │ │ │ vldr d1, [r3, #-24] @ 0xffffffe8 │ │ │ │ vadd.f64 d5, d7, d2 │ │ │ │ vldr d7, [r0, #268] @ 0x10c │ │ │ │ vmov.32 r6, d1[1] │ │ │ │ vsub.f64 d1, d5, d2 │ │ │ │ vnmul.f64 d5, d7, d4 │ │ │ │ vmla.f64 d7, d1, d7 │ │ │ │ vmla.f64 d7, d5, d1 │ │ │ │ vmov.f64 d7, #21 @ 0x40a80000 5.250 │ │ │ │ vcmpe.f64 d5, d7 │ │ │ │ vsqrt.f64 d22, d5 │ │ │ │ strle pc, [r1, #-2576] @ 0xfffff5f0 │ │ │ │ - blpl 6c31e0 <__bss_end__@@Base+0x61c5a8> │ │ │ │ + blpl 6c313c <__bss_end__@@Base+0x61c59c> │ │ │ │ @ instruction: 0xd1df429a │ │ │ │ bicsle r4, r3, lr, lsr #11 │ │ │ │ andcs fp, r0, #112, 26 @ 0x1c00 │ │ │ │ stmib r0, {r8, r9, sp}^ │ │ │ │ stmib r0, {r3, r4, r8, r9, sp}^ │ │ │ │ stmib r0, {r1, r2, r4, r8, r9, sp}^ │ │ │ │ ldcllt 3, cr2, [r0, #-80]! @ 0xffffffb0 │ │ │ │ + andhi pc, r0, pc, lsr #7 │ │ │ │ ... │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 1430c4 <__bss_end__@@Base+0x9c48c> │ │ │ │ + blhi 143024 <__bss_end__@@Base+0x9c484> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ ldcleq 8, cr15, [r8, #816] @ 0x330 │ │ │ │ @ instruction: 0xf8dfb0fd │ │ │ │ - strcs r3, [r0], -ip, ror #8 │ │ │ │ + @ instruction: 0x26003474 │ │ │ │ ldrbtmi sl, [fp], #-3387 @ 0xfffff2c5 │ │ │ │ tstls r6, r2, lsl #12 │ │ │ │ @ instruction: 0xf8dfac1c │ │ │ │ - movwls r1, #33888 @ 0x8460 │ │ │ │ - ldrbcc pc, [ip], #-2271 @ 0xfffff721 @ │ │ │ │ + movwls r1, #33896 @ 0x8468 │ │ │ │ + strbtcc pc, [r4], #-2271 @ 0xfffff721 @ │ │ │ │ rsbvs r4, r0, r9, ror r4 │ │ │ │ rscvs r4, r6, r8, lsr #12 │ │ │ │ stmiapl fp, {r1, r2, r5, r6, r8, sp, lr}^ │ │ │ │ orrvc pc, r0, pc, asr #8 │ │ │ │ cmnls fp, #1769472 @ 0x1b0000 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - stmib ip, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmib r4!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ movwcs r4, #9768 @ 0x2628 │ │ │ │ adcvs r6, r3, r5, lsr #32 │ │ │ │ - @ instruction: 0xf892f00c │ │ │ │ + @ instruction: 0xf94ef00c │ │ │ │ strtmi r9, [r0], -r9 │ │ │ │ - @ instruction: 0xf932f7ff │ │ │ │ + @ instruction: 0xf942f7ff │ │ │ │ cmple r1, r9, lsl #16 │ │ │ │ - strtpl pc, [r8], #-2271 @ 0xfffff721 │ │ │ │ + ldrtpl pc, [r0], #-2271 @ 0xfffff721 @ │ │ │ │ ldrbtmi r4, [sp], #-1568 @ 0xfffff9e0 │ │ │ │ strvc pc, [r8, #-2261]! @ 0xfffff72b │ │ │ │ - @ instruction: 0xf928f7ff │ │ │ │ + @ instruction: 0xf938f7ff │ │ │ │ teqle r7, r9, lsl #16 │ │ │ │ strcc pc, [r8, #-2261]! @ 0xfffff72b │ │ │ │ @ instruction: 0xf8df2230 │ │ │ │ - vqshl.s8 d21, d4, d0 │ │ │ │ + vqshl.s8 d21, d12, d0 │ │ │ │ movwls r3, #20803 @ 0x5143 │ │ │ │ ldrbtmi r4, [sp], #-1587 @ 0xfffff9cd │ │ │ │ vqdmulh.s d15, d2, d7 │ │ │ │ @ instruction: 0xf00b4628 │ │ │ │ - bls 187740 <__bss_end__@@Base+0xe0b08> │ │ │ │ + bls 187990 <__bss_end__@@Base+0xe0df0> │ │ │ │ ldrtmi r4, [r3], -r0, lsl #13 │ │ │ │ vmax.s8 d20, d0, d24 │ │ │ │ addseq r3, r2, r5, asr #2 │ │ │ │ - cdp2 0, 10, cr15, cr0, cr11, {0} │ │ │ │ + @ instruction: 0xff5cf00b │ │ │ │ @ instruction: 0x900b42b7 │ │ │ │ addhi pc, r2, r0, asr #6 │ │ │ │ mvnls pc, #14614528 @ 0xdf0000 │ │ │ │ - blmi ffe595d0 <__bss_end__@@Base+0xffdb2998> │ │ │ │ + blmi ffed9530 <__bss_end__@@Base+0xffe32990> │ │ │ │ mvnge pc, #14614528 @ 0xdf0000 │ │ │ │ @ instruction: 0xf8df44f9 │ │ │ │ - ldrbtmi fp, [fp], #-996 @ 0xfffffc1c │ │ │ │ + ldrbtmi fp, [fp], #-1004 @ 0xfffffc14 │ │ │ │ stmibvs r6!, {r0, r3, r8, sl, ip, sp, lr, pc} │ │ │ │ ldrbtmi r4, [fp], #1274 @ 0x4fa │ │ │ │ @ instruction: 0x63a6f503 │ │ │ │ strtmi r9, [r0], -r2, lsl #6 │ │ │ │ - @ instruction: 0xf8f6f7ff │ │ │ │ + @ instruction: 0xf906f7ff │ │ │ │ @ instruction: 0xf7ff4620 │ │ │ │ - stmdacs r8, {r0, r1, r4, r5, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ + stmdacs r8, {r0, r1, r8, fp, ip, sp, lr, pc} │ │ │ │ stmdacs r9, {r2, r4, ip, lr, pc} │ │ │ │ adchi pc, ip, r0 │ │ │ │ - bmi ffbd0cf0 <__bss_end__@@Base+0xffb2a0b8> │ │ │ │ - ldrbtmi r4, [sl], #-3047 @ 0xfffff419 │ │ │ │ + bmi ffc50c50 <__bss_end__@@Base+0xffbaa0b0> │ │ │ │ + ldrbtmi r4, [sl], #-3049 @ 0xfffff417 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, fp, ror fp │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - bichi pc, r0, r0, asr #32 │ │ │ │ + bichi pc, r3, r0, asr #32 │ │ │ │ rsbslt r4, sp, r0, lsr #12 │ │ │ │ - blhi 143000 <__bss_end__@@Base+0x9c3c8> │ │ │ │ + blhi 142f60 <__bss_end__@@Base+0x9c3c0> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ ldc 6, cr4, [r9, #-128] @ 0xffffff80 │ │ │ │ @ instruction: 0xf7ff8b02 │ │ │ │ - stmdacs r8, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ + stmdacs r8, {r0, r1, r2, r5, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ addshi pc, lr, r0 │ │ │ │ mvnle r2, r9, lsl #16 │ │ │ │ strcc pc, [r8, #-2267]! @ 0xfffff725 │ │ │ │ cdp 6, 0, cr4, cr7, cr0, {1} │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ @ instruction: 0xf7ff9be7 │ │ │ │ - stmdacs r8, {r0, r3, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ + stmdacs r8, {r0, r3, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ addshi pc, r9, r0 │ │ │ │ bicsle r2, r5, r9, lsl #16 │ │ │ │ - ldrbtmi r4, [fp], #-3035 @ 0xfffff425 │ │ │ │ + ldrbtmi r4, [fp], #-3037 @ 0xfffff423 │ │ │ │ @ instruction: 0x63a5f503 │ │ │ │ - bvc 43398 │ │ │ │ - blvc ff203830 <__bss_end__@@Base+0xff15cbf8> │ │ │ │ + bvc 432f8 │ │ │ │ + blvc ff203790 <__bss_end__@@Base+0xff15cbf0> │ │ │ │ andscs r6, r8, #1622016 @ 0x18c000 │ │ │ │ - ssatmi r4, #15, r7, asr #19 │ │ │ │ + ssatmi r4, #15, r9, asr #19 │ │ │ │ @ instruction: 0x36014415 │ │ │ │ adcsmi r4, r7, #2030043136 @ 0x79000000 │ │ │ │ @ instruction: 0x2c02fb03 │ │ │ │ movwmi pc, #15106 @ 0x3b02 @ │ │ │ │ ldc 4, cr4, [r1, #656] @ 0x290 │ │ │ │ vldr d2, [r1] │ │ │ │ vldr d3, [r1, #8] │ │ │ │ @@ -4581,655 +4567,648 @@ │ │ │ │ vmul.f64 d7, d5, d2 │ │ │ │ vmul.f64 d5, d6, d2 │ │ │ │ vmul.f64 d6, d7, d3 │ │ │ │ vstr d7, [r5, #-16] │ │ │ │ vstr d5, [r5, #-24] @ 0xffffffe8 │ │ │ │ vstr d6, [r5, #-16] │ │ │ │ orrle r7, lr, r2, lsl #22 │ │ │ │ - blcs 2e9d0 │ │ │ │ - cmpphi lr, r0, asr #6 @ p-variant is OBSOLETE │ │ │ │ + blcs 2e930 │ │ │ │ + cmpphi r1, r0, asr #6 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf8df2318 │ │ │ │ - andcs r9, r0, #244, 4 @ 0x4000000f │ │ │ │ - blx d91b2 <__bss_end__@@Base+0x3257a> │ │ │ │ + andcs r9, r0, #252, 4 @ 0xc000000f │ │ │ │ + blx d9112 <__bss_end__@@Base+0x32572> │ │ │ │ movwls r8, #29447 @ 0x7307 │ │ │ │ svcne 0x001d9b0b │ │ │ │ - stmib sp, {r0, r3, r4, r5, r7, r8, r9, fp, lr}^ │ │ │ │ + stmib sp, {r0, r1, r3, r4, r5, r7, r8, r9, fp, lr}^ │ │ │ │ ldrbtmi r5, [fp], #-514 @ 0xfffffdfe │ │ │ │ - blmi fee2ca08 <__bss_end__@@Base+0xfed85dd0> │ │ │ │ + blmi feeac968 <__bss_end__@@Base+0xfee05dc8> │ │ │ │ ldrbtmi r9, [fp], #-1293 @ 0xfffffaf3 │ │ │ │ strtmi r9, [r0], -ip, lsl #6 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ strbcc pc, [r0, #-2217] @ 0xfffff757 @ │ │ │ │ @ instruction: 0xf8c92300 │ │ │ │ @ instruction: 0xf8c93564 │ │ │ │ @ instruction: 0xf7ff3568 │ │ │ │ - @ instruction: 0xf020f865 │ │ │ │ - blcs 88a14 <__bss_start@@Base+0x2d974> │ │ │ │ + @ instruction: 0xf020f875 │ │ │ │ + blcs 88974 <__bss_start@@Base+0x2d96c> │ │ │ │ stmdacs r3, {r3, r6, ip, lr, pc} │ │ │ │ - rscshi pc, r8, r0, asr #32 │ │ │ │ + rscshi pc, r6, r0, asr #32 │ │ │ │ @ instruction: 0xf04f2500 │ │ │ │ @ instruction: 0xf8a90300 │ │ │ │ strtmi r3, [r0], -r0, asr #10 │ │ │ │ - @ instruction: 0xf856f7ff │ │ │ │ + @ instruction: 0xf866f7ff │ │ │ │ stmdacs r5, {r1, fp, ip, sp} │ │ │ │ movwge sp, #10489 @ 0x28f9 │ │ │ │ eoreq pc, r0, r3, asr r8 @ │ │ │ │ ldrmi r4, [r8, -r3, lsl #8] │ │ │ │ andeq r0, r0, r1, asr r0 │ │ │ │ @ instruction: 0xffffffeb │ │ │ │ andeq r0, r0, fp, ror r0 │ │ │ │ @ instruction: 0xffffffeb │ │ │ │ andeq r0, r0, r1, asr r0 │ │ │ │ - andeq r0, r0, r7, lsr r1 │ │ │ │ + andeq r0, r0, r3, lsr r1 │ │ │ │ strcc pc, [r8, #-2266]! @ 0xfffff726 │ │ │ │ cdp 6, 0, cr4, cr7, cr0, {1} │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ @ instruction: 0xf7ff8be7 │ │ │ │ - stmdacs r8, {r0, r3, r4, r5, fp, ip, sp, lr, pc} │ │ │ │ + stmdacs r8, {r0, r3, r6, fp, ip, sp, lr, pc} │ │ │ │ svcge 0x0062f47f │ │ │ │ strtmi r9, [r0], -r2, lsl #22 │ │ │ │ - blls c32b0 <__bss_end__@@Base+0x1c678> │ │ │ │ - @ instruction: 0xf830f7ff │ │ │ │ + blls c3210 <__bss_end__@@Base+0x1c670> │ │ │ │ + @ instruction: 0xf840f7ff │ │ │ │ @ instruction: 0xf47f2808 │ │ │ │ - blmi fe573c0c <__bss_end__@@Base+0xfe4ccfd4> │ │ │ │ + blmi fe5f3b6c <__bss_end__@@Base+0xfe54cfcc> │ │ │ │ @ instruction: 0xf503447b │ │ │ │ ldc 3, cr6, [r3, #-664] @ 0xfffffd68 │ │ │ │ strb r7, [r9, -r2, lsl #22]! │ │ │ │ @ instruction: 0xf0402d00 │ │ │ │ - ldcmi 0, cr8, [r1, #716] @ 0x2cc │ │ │ │ + ldcmi 0, cr8, [r3, #708] @ 0x2c4 │ │ │ │ ldrbtmi r9, [sp], #-2310 @ 0xfffff6fa │ │ │ │ eormi pc, r4, r5, lsl #4 │ │ │ │ - ldc2 7, cr15, [lr, #1016] @ 0x3f8 │ │ │ │ + ldc2 7, cr15, [sl, #1016]! @ 0x3f8 │ │ │ │ strbeq pc, [r4, #-2245]! @ 0xfffff73b @ │ │ │ │ ldr r2, [lr, r1, lsl #10]! │ │ │ │ vmla.i8 d9, d9, d6 │ │ │ │ @ instruction: 0xf7fe4024 │ │ │ │ - @ instruction: 0xf8c9fd95 │ │ │ │ - blge 389438 <__bss_end__@@Base+0x2e2800> │ │ │ │ + @ instruction: 0xf8c9fdb1 │ │ │ │ + blge 389398 <__bss_end__@@Base+0x2e27f8> │ │ │ │ ldrmi r9, [ip], r4, lsl #6 │ │ │ │ ldrcs r6, [r8, -r3, ror #18] │ │ │ │ - ldrbtmi r4, [sp], #-3462 @ 0xfffff27a │ │ │ │ + ldrbtmi r4, [sp], #-3464 @ 0xfffff278 │ │ │ │ movwvc pc, #31491 @ 0x7b03 @ │ │ │ │ strtvs pc, [r8], r5, lsl #10 │ │ │ │ cdpgt 0, 0, cr5, cr15, cr6, {7} │ │ │ │ andeq lr, pc, ip, lsr #17 │ │ │ │ stmia ip!, {r0, r1, r2, r3, r9, sl, fp, lr, pc} │ │ │ │ cdpgt 0, 0, cr0, cr15, cr15, {0} │ │ │ │ andeq lr, pc, ip, lsr #17 │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ - @ instruction: 0xf7fe4620 │ │ │ │ - stmdacs r9, {r0, r2, r4, r5, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - adcshi pc, r2, r0, asr #32 │ │ │ │ + @ instruction: 0xf7ff4620 │ │ │ │ + stmdacs r9, {r0, r2, fp, ip, sp, lr, pc} │ │ │ │ + adchi pc, pc, r0, asr #32 │ │ │ │ strlt pc, [r8, #-2261]! @ 0xfffff72b │ │ │ │ svceq 0x0000f1bb │ │ │ │ - @ instruction: 0xf8dfdd41 │ │ │ │ - strcs sl, [r0, #-480] @ 0xfffffe20 │ │ │ │ + @ instruction: 0xf8dfdd3f │ │ │ │ + strcs sl, [r0, #-488] @ 0xfffffe18 │ │ │ │ ldrbtmi r9, [sl], #3591 @ 0xe07 │ │ │ │ @ instruction: 0xf8dae012 │ │ │ │ ldrtmi r3, [r6], r8, lsr #10 │ │ │ │ ldrcc r3, [r8], -r1, lsl #10 │ │ │ │ - blx 1d95b6 <__bss_end__@@Base+0x13297e> │ │ │ │ + blx 1d9516 <__bss_end__@@Base+0x132976> │ │ │ │ @ instruction: 0xf1a38303 │ │ │ │ ldm ip!, {r3, r4, sl, fp} │ │ │ │ stmia lr!, {r0, r1, r2, r3} │ │ │ │ ldm ip, {r0, r1, r2, r3} │ │ │ │ stm lr, {r0, r1} │ │ │ │ - eorle r0, r8, r3 │ │ │ │ + eorle r0, r6, r3 │ │ │ │ @ instruction: 0xf7fe4620 │ │ │ │ - stmdacs r9, {r0, r4, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - blmi 1abc2c8 <__bss_end__@@Base+0x1a15690> │ │ │ │ + stmdacs r9, {r0, r5, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + blmi 1b3c228 <__bss_end__@@Base+0x1a95688> │ │ │ │ stmdavs r6!, {r3, r9, fp, ip, pc} │ │ │ │ - stmdbmi r9!, {r0, r2, r5, r7, fp, sp, lr}^ │ │ │ │ - bmi 1a5e288 <__bss_end__@@Base+0x19b7650> │ │ │ │ + ldmpl r4, {r0, r2, r5, r7, fp, sp, lr}^ │ │ │ │ + strtmi r4, [fp], -sl, ror #18 │ │ │ │ + stmdavs r0!, {r1, r3, r5, r6, r9, fp, lr} │ │ │ │ ldrbtmi r4, [sl], #-1145 @ 0xfffffb87 │ │ │ │ - ldrtmi r6, [r3], -r0, lsr #16 │ │ │ │ - smlabtpl r0, sp, r9, lr │ │ │ │ - @ instruction: 0xf7fb2101 │ │ │ │ - stmdbmi r5!, {r1, r2, r3, r6, r9, fp, sp, lr, pc}^ │ │ │ │ - bmi 195981c <__bss_end__@@Base+0x18b2be4> │ │ │ │ - ldrbtmi r6, [r9], #-2080 @ 0xfffff7e0 │ │ │ │ - stmib sp, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - mrscs r5, (UNDEF: 17) │ │ │ │ - b 10c5f4c <__bss_end__@@Base+0x101f314> │ │ │ │ - bls 2c1a74 <__bss_end__@@Base+0x21ae3c> │ │ │ │ + ldrtmi r9, [r2], -r0, lsl #4 │ │ │ │ + b 1545e94 <__bss_end__@@Base+0x149f2f4> │ │ │ │ + strtmi r6, [fp], -r0, lsr #16 │ │ │ │ + ldrtmi r4, [r2], -r6, ror #24 │ │ │ │ + ldrbtmi r4, [ip], #-2406 @ 0xfffff69a │ │ │ │ + ldrbtmi r9, [r9], #-1024 @ 0xfffffc00 │ │ │ │ + b 12c5ea8 <__bss_end__@@Base+0x121f308> │ │ │ │ + bls 2c19d8 <__bss_end__@@Base+0x21ae38> │ │ │ │ strbcc pc, [r0, #-2226] @ 0xfffff74e @ │ │ │ │ movweq pc, #4163 @ 0x1043 @ │ │ │ │ strbcc pc, [r0, #-2210] @ 0xfffff75e @ │ │ │ │ - bls 141cb8 <__bss_end__@@Base+0x9b080> │ │ │ │ + bls 141c1c <__bss_end__@@Base+0x9b07c> │ │ │ │ stmdbls r7, {r3, r4, r6, r9, sl, lr} │ │ │ │ @ instruction: 0xf0016965 │ │ │ │ - blls c6ccc <__bss_end__@@Base+0x20094> │ │ │ │ + blls c6b08 <__bss_end__@@Base+0x1ff68> │ │ │ │ @ instruction: 0xf8439a03 │ │ │ │ andcc r0, r1, #4, 30 │ │ │ │ movwls r9, #8707 @ 0x2203 │ │ │ │ - blx 150bf2 <__bss_end__@@Base+0xa9fba> │ │ │ │ + blx 150b4e <__bss_end__@@Base+0xa9fae> │ │ │ │ rscpl r3, r0, r3, lsl #6 │ │ │ │ addsmi r9, r3, #5120 @ 0x1400 │ │ │ │ - svcge 0x0025f47f │ │ │ │ - vtst.8 q10, q0, q1 │ │ │ │ + svcge 0x0027f47f │ │ │ │ + vtst.8 q10, q0, │ │ │ │ movwcs r3, #357 @ 0x165 │ │ │ │ ldrbtmi r2, [r8], #-640 @ 0xfffffd80 │ │ │ │ @ instruction: 0xf00b9d0d │ │ │ │ - blls 28742c <__bss_end__@@Base+0x1e07f4> │ │ │ │ + blls 287680 <__bss_end__@@Base+0x1e0ae0> │ │ │ │ strcs r9, [r0], -r5, lsl #30 │ │ │ │ strmi r6, [r4], -r3 │ │ │ │ strbvs r9, [r3, -fp, lsl #22] │ │ │ │ strvs r6, [r6, r7, lsl #14] │ │ │ │ stc2 7, cr15, [r6, #1020]! @ 0x3fc │ │ │ │ @ instruction: 0x46394633 │ │ │ │ movwcc lr, #4098 @ 0x1002 │ │ │ │ mulle r7, r9, r2 │ │ │ │ svccs 0x0004f855 │ │ │ │ - bcs 22a20 │ │ │ │ + bcs 2297c │ │ │ │ @ instruction: 0x4620d0f7 │ │ │ │ - blx fe2c5fde <__bss_end__@@Base+0xfe21f3a6> │ │ │ │ + blx fe545f3a <__bss_end__@@Base+0xfe49f39a> │ │ │ │ @ instruction: 0xf00b4640 │ │ │ │ - @ instruction: 0xe682fdb3 │ │ │ │ + @ instruction: 0xe684fe71 │ │ │ │ strcc r9, [r1, #-3596] @ 0xfffff1f4 │ │ │ │ vmla.i8 d9, d6, d6 │ │ │ │ @ instruction: 0xf7fe4024 │ │ │ │ - @ instruction: 0xf8c6fceb │ │ │ │ - str r0, [ip, -r8, ror #10] │ │ │ │ + @ instruction: 0xf8c6fd09 │ │ │ │ + str r0, [lr, -r8, ror #10] │ │ │ │ stmiavs r3!, {r8, sl, sp}^ │ │ │ │ - stmdbvs r3!, {r0, r1, r4, r5, r7, r8, ip, sp, pc} │ │ │ │ + stmdbvs r3!, {r0, r1, r3, r5, r7, r8, ip, sp, pc} │ │ │ │ mrrcne 0, 14, r6, sl, cr5 │ │ │ │ - blcs 2bc010 <__bss_end__@@Base+0x2153d8> │ │ │ │ + blcs 2bbf6c <__bss_end__@@Base+0x2153cc> │ │ │ │ stmiavs r5!, {r0, r1, r2, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ - stmdbls r8, {r4, r5, r9, fp, lr} │ │ │ │ - blmi d620b0 <__bss_end__@@Base+0xcbb478> │ │ │ │ - smlabbcs r1, ip, r8, r5 │ │ │ │ - ldrbtmi r4, [fp], #-2612 @ 0xfffff5cc │ │ │ │ - ldrbtmi r6, [sl], #-2080 @ 0xfffff7e0 │ │ │ │ - ldrtmi r9, [r3], -r1, lsl #6 │ │ │ │ - @ instruction: 0xf7fb9500 │ │ │ │ - @ instruction: 0xe78ce9dc │ │ │ │ - @ instruction: 0xf7fb6860 │ │ │ │ - stmdacs sl, {r1, r2, r9, fp, sp, lr, pc} │ │ │ │ - andle r6, r2, r0, lsr #2 │ │ │ │ - bicsle r3, lr, r1 │ │ │ │ - stmiavs r5!, {r0, r2, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ - strb r3, [r3, r1, lsl #10]! │ │ │ │ - bls 21acd4 <__bss_end__@@Base+0x17409c> │ │ │ │ - stmiavs r5!, {r1, r2, r5, fp, sp, lr} │ │ │ │ - ldmpl r4, {r3, r5, r8, fp, lr}^ │ │ │ │ - ldrbtmi r4, [r9], #-2600 @ 0xfffff5d8 │ │ │ │ - @ instruction: 0xe76f447a │ │ │ │ - movwcs r4, #2087 @ 0x827 │ │ │ │ - vhsub.s8 d18, d16, d0 │ │ │ │ - ldrbtmi r3, [r8], #-357 @ 0xfffffe9b │ │ │ │ - stc2l 0, cr15, [r0], {11} │ │ │ │ - bls 2eec94 <__bss_end__@@Base+0x24805c> │ │ │ │ - andvs r4, r3, r4, lsl #12 │ │ │ │ - strvs r9, [r3, -r5, lsl #22] │ │ │ │ - stmib r0, {r8, r9, sp}^ │ │ │ │ - @ instruction: 0xf7ff231d │ │ │ │ - str pc, [sp, r7, asr #26]! │ │ │ │ - ldmib sl, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - ldrdeq r0, [r5], -lr │ │ │ │ - andeq r0, r5, ip, asr #7 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r3, r5, sl, asr #8 │ │ │ │ - andeq r1, r4, sl, lsr #30 │ │ │ │ - strdeq r3, [r5], -r8 │ │ │ │ + stmdbls r8, {r0, r1, r4, r5, r9, fp, lr} │ │ │ │ + blmi e2200c <__bss_end__@@Base+0xd7b46c> │ │ │ │ + ldrtmi r5, [r2], -ip, lsl #17 │ │ │ │ + ldrbtmi r4, [fp], #-2359 @ 0xfffff6c9 │ │ │ │ + ldrbtmi r6, [r9], #-2080 @ 0xfffff7e0 │ │ │ │ + strtmi r9, [fp], -r0, lsl #6 │ │ │ │ + stmib r4!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdavs r0!, {r1, r2, r3, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ + b b45f7c <__bss_end__@@Base+0xa9f3dc> │ │ │ │ + @ instruction: 0x6120280a │ │ │ │ + andcc sp, r1, r2 │ │ │ │ + ubfx sp, pc, #3, #7 │ │ │ │ + strcc r6, [r1, #-2213] @ 0xfffff75b │ │ │ │ + blmi 9c1f34 <__bss_end__@@Base+0x91b394> │ │ │ │ + stmdavs r6!, {r3, r9, fp, ip, pc} │ │ │ │ + ldmpl r4, {r0, r2, r5, r7, fp, sp, lr}^ │ │ │ │ + strtmi r4, [fp], -fp, lsr #18 │ │ │ │ + stmdavs r0!, {r0, r1, r3, r5, r9, fp, lr} │ │ │ │ + ldrbtmi r4, [sl], #-1145 @ 0xfffffb87 │ │ │ │ + ldrtmi r9, [r2], -r0, lsl #4 │ │ │ │ + stmib r8, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdami r8!, {r1, r4, r5, r6, r8, r9, sl, sp, lr, pc} │ │ │ │ + addcs r2, r0, #0, 6 │ │ │ │ + msrcc (UNDEF: 101), r0 │ │ │ │ + @ instruction: 0xf00b4478 │ │ │ │ + blls 2875b8 <__bss_end__@@Base+0x1e0a18> │ │ │ │ + strmi r9, [r4], -fp, lsl #20 │ │ │ │ + blls 15ffe8 <__bss_end__@@Base+0xb9448> │ │ │ │ + movwcs r6, #1795 @ 0x703 │ │ │ │ + tstcs sp, #192, 18 @ 0x300000 │ │ │ │ + stc2l 7, cr15, [r2, #-1020] @ 0xfffffc04 │ │ │ │ + @ instruction: 0xf7fbe7a8 │ │ │ │ + svclt 0x0000e9c4 │ │ │ │ + andeq r0, r5, lr, ror r4 │ │ │ │ + andeq r0, r5, ip, ror #8 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r3, r5, r2, asr r4 │ │ │ │ + andeq r1, r4, r6, asr #30 │ │ │ │ + andeq r3, r5, r0, lsl #8 │ │ │ │ + strdeq r3, [r5], -sl │ │ │ │ + strdeq r3, [r5], -r4 │ │ │ │ strdeq r3, [r5], -r2 │ │ │ │ - andeq r3, r5, ip, ror #7 │ │ │ │ - andeq r3, r5, sl, ror #7 │ │ │ │ - andeq r0, r5, lr, lsl #6 │ │ │ │ - andeq r3, r5, r6, ror r3 │ │ │ │ - andeq r0, r5, ip, ror #11 │ │ │ │ - strdeq r3, [r5], -r0 │ │ │ │ + andeq r0, r5, lr, lsr #7 │ │ │ │ + andeq r3, r5, lr, ror r3 │ │ │ │ + andeq r0, r5, r4, lsl #13 │ │ │ │ + strdeq r3, [r5], -r8 │ │ │ │ + andeq r3, r5, r6, ror #5 │ │ │ │ ldrdeq r3, [r5], -lr │ │ │ │ - ldrdeq r3, [r5], -r6 │ │ │ │ - andeq r3, r5, r8, asr #4 │ │ │ │ - andeq r3, r5, r2, lsr r2 │ │ │ │ - andeq r3, r5, r6, lsl #4 │ │ │ │ - andeq r3, r5, r2, asr #3 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r1, r4, ip, asr sp │ │ │ │ - andeq r1, r4, r2, lsl ip │ │ │ │ - andeq r1, r4, sl, asr sp │ │ │ │ - strdeq r1, [r4], -r8 │ │ │ │ + andeq r3, r5, r0, asr r2 │ │ │ │ + andeq r3, r5, sl, lsr r2 │ │ │ │ + andeq r3, r5, lr, lsl #4 │ │ │ │ + andeq r3, r5, sl, asr #3 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r1, r4, ip, lsr #24 │ │ │ │ + andeq r1, r4, lr, ror #26 │ │ │ │ + andeq r1, r4, r2, ror sp │ │ │ │ andeq r1, r4, r2, lsl ip │ │ │ │ - andeq r1, r4, sl, lsr ip │ │ │ │ - andeq r1, r4, sl, lsr #22 │ │ │ │ - andeq r1, r4, lr, lsl ip │ │ │ │ - strdeq r1, [r4], -r4 │ │ │ │ - andeq r1, r4, r2, asr fp │ │ │ │ - @ instruction: 0xf7ff2100 │ │ │ │ - svclt 0x0000bd7f │ │ │ │ + andeq r1, r4, r2, lsr ip │ │ │ │ + andeq r1, r4, r6, asr ip │ │ │ │ + andeq r1, r4, sl, asr #22 │ │ │ │ + andeq r1, r4, r4, lsl fp │ │ │ │ + andeq r1, r4, r6, lsr ip │ │ │ │ + andeq r1, r4, r8, ror #22 │ │ │ │ @ instruction: 0xf7ff2100 │ │ │ │ svclt 0x0000bd7b │ │ │ │ + @ instruction: 0xf7ff2100 │ │ │ │ + svclt 0x0000bd77 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stceq 0, cr15, [r0], {79} @ 0x4f │ │ │ │ cdpcs 4, 4, cr15, cr10, cr15, {2} │ │ │ │ - blhi c35d4 <__bss_end__@@Base+0x1c99c> │ │ │ │ + blhi c353c <__bss_end__@@Base+0x1c99c> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ vmlaeq.f64 d14, d30, d28 │ │ │ │ stcpl 5, cr15, [r0], {172} @ 0xac │ │ │ │ andeq pc, r0, ip, asr #17 │ │ │ │ ldrshle r4, [r9, #84]! @ 0x54 │ │ │ │ cdppl 5, 8, cr15, cr0, cr14, {5} │ │ │ │ stmibeq r8!, {r1, r2, r3, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ stclcs 5, cr15, [sl, #-692] @ 0xfffffd4c │ │ │ │ - @ instruction: 0xf2ad4ad6 │ │ │ │ - blmi ff5a35f8 <__bss_end__@@Base+0xff4fc9c0> │ │ │ │ + @ instruction: 0xf2ad4ad0 │ │ │ │ + blmi ff423560 <__bss_end__@@Base+0xff37c9c0> │ │ │ │ @ instruction: 0x4606447a │ │ │ │ - @ instruction: 0xf50d48d5 │ │ │ │ - strls r2, [r4], -sl, asr #8 │ │ │ │ + @ instruction: 0xf50d48cf │ │ │ │ + strls r2, [r5], -sl, asr #8 │ │ │ │ vrhadd.s8 d2, d4, d0 │ │ │ │ ldrbtmi r6, [r8], #-1060 @ 0xfffffbdc │ │ │ │ strcs r5, [r0, #-2259] @ 0xfffff72d │ │ │ │ - stmibvs r5, {r0, r2, r3, r8, sl, ip, sp, lr, pc}^ │ │ │ │ - blcs 12c559c <__bss_end__@@Base+0x121e964> │ │ │ │ + bvs ff185500 <__bss_end__@@Base+0xff0de960> │ │ │ │ + blhi ff18374c <__bss_end__@@Base+0xff0dcbac> │ │ │ │ eorvs r6, r3, fp, lsl r8 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - stc2 7, cr15, [ip], #-1016 @ 0xfffffc08 │ │ │ │ - blcs ff2037f4 <__bss_end__@@Base+0xff15cbbc> │ │ │ │ + mcrr2 7, 15, pc, r4, cr14 @ │ │ │ │ + blcs ff08375c <__bss_end__@@Base+0xfefdcbbc> │ │ │ │ ldmdage r2!, {r2, r9, sl, lr} │ │ │ │ andsvs sl, sp, r3, lsr #22 │ │ │ │ - blvc 2855b0 <__bss_end__@@Base+0x1de978> │ │ │ │ - blne 10c3c48 <__bss_end__@@Base+0x101d010> │ │ │ │ - bleq 10c3c4c <__bss_end__@@Base+0x101d014> │ │ │ │ - stc2l 0, cr15, [r6], {2} │ │ │ │ - eorscs sl, r8, #63488 @ 0xf800 │ │ │ │ - ldrmi r4, [r8], -r9, lsr #12 │ │ │ │ - movwls r4, #50718 @ 0xc61e │ │ │ │ - svc 0x0074f7fa │ │ │ │ - @ instruction: 0xf50d4ac1 │ │ │ │ - stmiami r1, {r1, r2, r5, r8, lr}^ │ │ │ │ - ldrbtmi r3, [sl], #-296 @ 0xfffffed8 │ │ │ │ - vldr d10, [pc, #136] @ 8238 │ │ │ │ - @ instruction: 0x46ca8bb9 │ │ │ │ - blge 92cdcc <__bss_end__@@Base+0x886194> │ │ │ │ + mrc 6, 5, r4, cr0, cr7, {2} │ │ │ │ + vmov.f64 d1, d2 │ │ │ │ + @ instruction: 0xf0020b42 │ │ │ │ + blge fc72d4 <__bss_end__@@Base+0xf20734> │ │ │ │ + @ instruction: 0x46292238 │ │ │ │ + @ instruction: 0x461e4618 │ │ │ │ + @ instruction: 0xf7fa930d │ │ │ │ + bmi fef43f78 <__bss_end__@@Base+0xfee9d3d8> │ │ │ │ + ldmmi ip!, {r1, r5, r8, r9, fp, sp, pc} │ │ │ │ + msrmi CPSR_sx, sp, lsl #10 │ │ │ │ @ instruction: 0xf50d9306 │ │ │ │ - vcgt.s8 q1, , q5 │ │ │ │ - ldrbtmi r5, [r8], #-804 @ 0xfffffcdc │ │ │ │ - @ instruction: 0xf5a1911d │ │ │ │ - movwls r6, #12673 @ 0x3181 │ │ │ │ - movwvc pc, #25858 @ 0x6502 @ │ │ │ │ - rsbsvs r9, r4, #24, 10 @ 0x6000000 │ │ │ │ - andsls r9, sl, r3, lsl r2 │ │ │ │ - stmib sp, {r0, r2, r4, r8, ip, pc}^ │ │ │ │ - ldrls r1, [r4, #-1287] @ 0xfffffaf9 │ │ │ │ - ldrpl lr, [r6, #-2509] @ 0xfffff633 │ │ │ │ - blls ece4c <__bss_end__@@Base+0x46214> │ │ │ │ - movwls r4, #1626 @ 0x65a │ │ │ │ - blls 16e608 <__bss_end__@@Base+0xc79d0> │ │ │ │ - @ instruction: 0xf7fe9804 │ │ │ │ - @ instruction: 0x4681fe3b │ │ │ │ - ldmle r4!, {r3, r8, sl, fp, sp}^ │ │ │ │ - @ instruction: 0xf015e8df │ │ │ │ - rsceq r0, r8, r2, lsl #4 │ │ │ │ - mlaseq r0, r6, r0, r0 │ │ │ │ - cmpeq sl, r0, lsr #3 │ │ │ │ - eoreq r0, ip, r1, ror r1 │ │ │ │ - @ instruction: 0xf5aa0009 │ │ │ │ - ldmdavs ip, {r2, r4, r5, r7, r8, r9, sp, lr} │ │ │ │ - mvnle r2, r0, lsl #24 │ │ │ │ - @ instruction: 0xf5aa9e13 │ │ │ │ - strcs r6, [r1, #-946] @ 0xfffffc4e │ │ │ │ - addvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ - @ instruction: 0xf8c64659 │ │ │ │ - @ instruction: 0xf8c6041c │ │ │ │ - ldmdb r3, {r2, r3, r9, ip, lr}^ │ │ │ │ - blls 4e1e40 <__bss_end__@@Base+0x43b208> │ │ │ │ - stmib r3, {r0, r3, r4, fp, ip, pc}^ │ │ │ │ - @ instruction: 0xf7fb6784 │ │ │ │ - @ instruction: 0x9e13e980 │ │ │ │ - addvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ - @ instruction: 0xf5069903 │ │ │ │ - @ instruction: 0xf7fb7046 │ │ │ │ - @ instruction: 0xf8c6e978 │ │ │ │ - bfi r4, r8, (invalid: 8:6) │ │ │ │ - svclt 0x0008280a │ │ │ │ - strb r2, [r2, r0, lsl #10] │ │ │ │ - @ instruction: 0xf000282a │ │ │ │ - stmdacs sp!, {r0, r1, r5, r6, r7, sl, pc} │ │ │ │ - strbhi pc, [lr], #0 @ │ │ │ │ - @ instruction: 0xf0002802 │ │ │ │ - @ instruction: 0xf5aa83d1 │ │ │ │ - ldmdavs fp, {r2, r4, r5, r7, r8, r9, sp, lr} │ │ │ │ - @ instruction: 0xd1b42b00 │ │ │ │ - tstcs r8, r8, lsl #24 │ │ │ │ - vmovne.8 d0[4], r9 │ │ │ │ - @ instruction: 0xf5a31ea2 │ │ │ │ - blx 61092 <__bss_start@@Base+0x5ff2> │ │ │ │ - blx 54a9a │ │ │ │ - ldc 3, cr3, [r2] │ │ │ │ - vldr d7, [r3] │ │ │ │ - vmov.f64 d6, #64 @ 0x3e000000 0.125 │ │ │ │ - vneg.f64 d22, d7 │ │ │ │ - tstple r3, r0, lsl sl @ p-variant is OBSOLETE │ │ │ │ - blvs c38f4 <__bss_end__@@Base+0x1ccbc> │ │ │ │ - blvc c38f4 <__bss_end__@@Base+0x1ccbc> │ │ │ │ - blvs 1203d80 <__bss_end__@@Base+0x115d148> │ │ │ │ - blx 443e78 <__bss_end__@@Base+0x39d240> │ │ │ │ - ldc 1, cr13, [r3, #40] @ 0x28 │ │ │ │ - vldr d6, [r2, #16] │ │ │ │ - vmov.f64 d7, #68 @ 0x3e200000 0.1562500 │ │ │ │ - vneg.f64 d22, d7 │ │ │ │ - svclt 0x0008fa10 │ │ │ │ - strls r4, [r8], #-1540 @ 0xfffff9fc │ │ │ │ - orrspl pc, ip, #-1610612726 @ 0xa000000a │ │ │ │ - bls 32fb28 <__bss_end__@@Base+0x288ef0> │ │ │ │ - stmdals r8, {r0, r4, r5, r9, sl, lr} │ │ │ │ - stclne 8, cr6, [ip], #-116 @ 0xffffff8c │ │ │ │ - ldclmi 0, cr6, [r4], #-112 @ 0xffffff90 │ │ │ │ - @ instruction: 0xf9a0f001 │ │ │ │ - addvs pc, r1, #713031680 @ 0x2a800000 │ │ │ │ - @ instruction: 0x63b2f5aa │ │ │ │ - @ instruction: 0x4659447c │ │ │ │ - eoreq pc, r5, r2, asr #16 │ │ │ │ - andvc pc, r6, r4, lsl #10 │ │ │ │ + ldrbtmi r2, [sl], #-842 @ 0xfffffcb6 │ │ │ │ + @ instruction: 0xf5033128 │ │ │ │ + movwls r7, #13065 @ 0x3309 │ │ │ │ + movwls sl, #31524 @ 0x7b24 │ │ │ │ + movtcs pc, #42253 @ 0xa50d @ │ │ │ │ + vqshl.s8 q2, q12, │ │ │ │ + tstls lr, r4, lsr #6 │ │ │ │ + @ instruction: 0xf5a19304 │ │ │ │ + @ instruction: 0xf5026181 │ │ │ │ + ldrls r7, [r8, #-774] @ 0xfffffcfa │ │ │ │ + andsls r6, r9, #116, 4 @ 0x40000007 │ │ │ │ + tstls r5, fp, lsl r0 │ │ │ │ + strne lr, [r8, #-2509] @ 0xfffff633 │ │ │ │ + stmib sp, {r2, r4, r8, sl, ip, pc}^ │ │ │ │ + tstls sl, #92274688 @ 0x5800000 │ │ │ │ + movwls r9, #2820 @ 0xb04 │ │ │ │ + blls 1ae964 <__bss_end__@@Base+0x107dc4> │ │ │ │ + stmdals r5, {r0, r1, r2, r8, fp, ip, pc} │ │ │ │ + mcr2 7, 2, pc, cr6, cr14, {7} @ │ │ │ │ + stccs 6, cr4, [r8, #-520] @ 0xfffffdf8 │ │ │ │ + ldm pc, {r2, r4, r5, r6, r7, fp, ip, lr, pc}^ @ │ │ │ │ + mvnseq pc, r5, lsl r0 @ │ │ │ │ + ldrdeq r0, [ip], sp │ │ │ │ + orrseq r0, r3, sl, lsr #32 │ │ │ │ + cmneq r4, sp, asr #2 │ │ │ │ + andeq r0, r9, r6, lsr #32 │ │ │ │ + @ instruction: 0x63b4f5a7 │ │ │ │ + stccs 8, cr6, [r0], {28} │ │ │ │ + cdpls 1, 1, cr13, cr9, cr4, {7} │ │ │ │ + @ instruction: 0x63b2f5a7 │ │ │ │ + strcs r9, [r1, #-2307] @ 0xfffff6fd │ │ │ │ movwcs lr, #10579 @ 0x2953 │ │ │ │ - orrcs lr, r4, #196, 18 @ 0x310000 │ │ │ │ - addvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ - @ instruction: 0xf8c42501 │ │ │ │ - @ instruction: 0xf8c4941c │ │ │ │ + ldreq pc, [ip], #-2246 @ 0xfffff73a │ │ │ │ + stmib r6, {r1, r3, r4, fp, ip, pc}^ │ │ │ │ + @ instruction: 0xf8c62384 │ │ │ │ @ instruction: 0xf7fb520c │ │ │ │ - stmdbls r3, {r3, r4, r8, fp, sp, lr, pc} │ │ │ │ - addvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ - subvc pc, r6, r4, lsl #10 │ │ │ │ - ldmdb r0, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - strls r2, [r7], -r0, lsl #6 │ │ │ │ - ldrcc pc, [r8], #-2244 @ 0xfffff73c │ │ │ │ - ldrb r9, [ip, -r8, lsl #6] │ │ │ │ - stmdbeq fp, {r5, r7, r8, ip, sp, lr, pc} │ │ │ │ - svceq 0x0022f1b9 │ │ │ │ - svcge 0x0057f63f │ │ │ │ - @ instruction: 0xf853a302 │ │ │ │ - strbmi r9, [fp], #-41 @ 0xffffffd7 │ │ │ │ - svclt 0x00004718 │ │ │ │ - muleq r0, r7, r5 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - andeq r0, r0, fp, lsr #21 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - andeq r0, r0, r9, lsl #11 │ │ │ │ - andeq r0, r0, fp, ror r5 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - andeq r0, r0, r7, asr r5 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - @ instruction: 0xfffffea3 │ │ │ │ - andeq r0, r0, r9, lsr r5 │ │ │ │ - ldmibcc pc!, {r8, ip, sp, lr, pc}^ @ │ │ │ │ - svceq 0x0029f1b9 │ │ │ │ - cmpphi r8, r0, lsl #4 @ p-variant is OBSOLETE │ │ │ │ + stmdbls r4, {r1, r2, r3, r4, r6, fp, sp, lr, pc} │ │ │ │ + subvc pc, r6, r6, lsl #10 │ │ │ │ + ldmda r8, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldrmi pc, [r8], #-2246 @ 0xfffff73a │ │ │ │ + stmdacs sl, {r2, r3, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ + strcs fp, [r0, #-3848] @ 0xfffff0f8 │ │ │ │ + stmdacs sl!, {r3, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ + strbhi pc, [r5], #0 @ │ │ │ │ + @ instruction: 0xf000282d │ │ │ │ + stmdacs r2, {r0, r4, r5, r7, sl, pc} │ │ │ │ + @ instruction: 0x83b5f000 │ │ │ │ + @ instruction: 0x63b4f5a7 │ │ │ │ + blcs 22244 │ │ │ │ + stcls 1, cr13, [r9], {186} @ 0xba │ │ │ │ + blls 790640 <__bss_end__@@Base+0x6e9aa0> │ │ │ │ + cdpne 14, 10, cr1, cr2, cr0, {3} │ │ │ │ + orrvs pc, r1, #683671552 @ 0x28c00000 │ │ │ │ + andcc pc, r2, #1024 @ 0x400 │ │ │ │ + movwcc pc, #2817 @ 0xb01 @ │ │ │ │ + blvc 4383c │ │ │ │ + blvs 43844 │ │ │ │ + blvs 1203ccc <__bss_end__@@Base+0x115d12c> │ │ │ │ + blx 443dc4 <__bss_end__@@Base+0x39d224> │ │ │ │ + ldc 1, cr13, [r3, #76] @ 0x4c │ │ │ │ + vldr d6, [r2, #8] │ │ │ │ + vmov.f64 d7, #66 @ 0x3e100000 0.1406250 │ │ │ │ + vneg.f64 d22, d7 │ │ │ │ + tstple sl, r0, lsl sl @ p-variant is OBSOLETE │ │ │ │ + blvs 143864 <__bss_end__@@Base+0x9ccc4> │ │ │ │ + blvc 143864 <__bss_end__@@Base+0x9ccc4> │ │ │ │ + blvs 1203cf0 <__bss_end__@@Base+0x115d150> │ │ │ │ + blx 443de8 <__bss_end__@@Base+0x39d248> │ │ │ │ + strmi fp, [r4], -r8, lsl #30 │ │ │ │ + vaddhn.i64 d9, , │ │ │ │ + mrcls 3, 0, r5, cr5, cr12, {4} │ │ │ │ + ldrtmi r9, [r1], -sp, lsl #20 │ │ │ │ + ldmdavs sp, {r0, r3, fp, ip, pc} │ │ │ │ + andsvs r1, ip, ip, ror #24 │ │ │ │ + @ instruction: 0xf0014c70 │ │ │ │ + @ instruction: 0xf5a7f957 │ │ │ │ + @ instruction: 0xf5a76281 │ │ │ │ + ldrbtmi r6, [ip], #-946 @ 0xfffffc4e │ │ │ │ + @ instruction: 0xf8429903 │ │ │ │ + @ instruction: 0xf5040025 │ │ │ │ + ldmdb r3, {r1, r2, ip, sp, lr}^ │ │ │ │ + stmib r4, {r1, r8, r9, sp}^ │ │ │ │ + strcs r2, [r1, #-900] @ 0xfffffc7c │ │ │ │ + ldrge pc, [ip], #-2244 @ 0xfffff73c │ │ │ │ + andpl pc, ip, #196, 16 @ 0xc40000 │ │ │ │ + svc 0x00faf7fa │ │ │ │ + @ instruction: 0xf5049904 │ │ │ │ + @ instruction: 0xf7fa7046 │ │ │ │ + movwcs lr, #4086 @ 0xff6 │ │ │ │ + @ instruction: 0xf8c49608 │ │ │ │ + movwls r3, #37912 @ 0x9418 │ │ │ │ + @ instruction: 0xf1a0e766 │ │ │ │ + @ instruction: 0xf1ba0a0b │ │ │ │ + @ instruction: 0xf63f0f22 │ │ │ │ + movwge sl, #12129 @ 0x2f61 │ │ │ │ + eorge pc, sl, r3, asr r8 @ │ │ │ │ + @ instruction: 0x47184453 │ │ │ │ + andeq r0, r0, r3, ror r5 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + andeq r0, r0, pc, asr sl │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + andeq r0, r0, r9, ror #10 │ │ │ │ + andeq r0, r0, pc, asr r5 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + andeq r0, r0, r3, asr #10 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + @ instruction: 0xfffffeb9 │ │ │ │ + andeq r0, r0, r9, lsr #10 │ │ │ │ + bcc 4728 │ │ │ │ + svceq 0x0029f1ba │ │ │ │ + cmpphi r6, r0, lsl #4 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf853a302 │ │ │ │ - strbmi r9, [fp], #-41 @ 0xffffffd7 │ │ │ │ + ldrbmi sl, [r3], #-42 @ 0xffffffd6 │ │ │ │ svclt 0x00004718 │ │ │ │ - @ instruction: 0xfffffdff │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - @ instruction: 0x000005b7 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r9, lsr #24 │ │ │ │ - andeq r0, r0, pc, lsl r6 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - @ instruction: 0x000005bb │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - @ instruction: 0x000002b1 │ │ │ │ - @ instruction: 0x000002b1 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r5, lsr #5 │ │ │ │ - andeq r0, r0, r7, ror r5 │ │ │ │ - andeq r0, r0, r3, lsr r5 │ │ │ │ - andhi pc, r0, pc, lsr #7 │ │ │ │ + @ instruction: 0xfffffe15 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, fp, lsl #11 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + @ instruction: 0x00000bbd │ │ │ │ + strdeq r0, [r0], -r3 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, pc, lsl #11 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, sp, lsr #5 │ │ │ │ + andeq r0, r0, sp, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, r1, lsr #5 │ │ │ │ + andeq r0, r0, fp, asr #10 │ │ │ │ + andeq r0, r0, pc, lsl #10 │ │ │ │ ... │ │ │ │ - @ instruction: 0x0004feb8 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r1, r4, r2, ror fp │ │ │ │ - andeq r2, r5, lr, lsl #30 │ │ │ │ - strdeq r2, [r5], -r6 │ │ │ │ - andeq r2, r5, ip, asr #27 │ │ │ │ + andeq pc, r4, r0, asr pc @ │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r1, r4, r2, lsl #23 │ │ │ │ + andeq r2, r5, sl, lsl #30 │ │ │ │ + strdeq r2, [r5], -r8 │ │ │ │ + ldrdeq r2, [r5], -r6 │ │ │ │ vadd.i8 d2, d0, d12 │ │ │ │ - stmdacs r1, {r2, r5, r6, r7, r9, pc} │ │ │ │ + stmdacs r1, {r0, r2, r3, r6, r7, r9, pc} │ │ │ │ rschi pc, lr, r0, asr #4 │ │ │ │ - blcs 28fed0 <__bss_end__@@Base+0x1e9298> │ │ │ │ + blcs 28fe20 <__bss_end__@@Base+0x1e9280> │ │ │ │ rschi pc, sl, r0, lsl #4 │ │ │ │ @ instruction: 0xf013e8df │ │ │ │ - tsteq lr, r8, lsl r1 │ │ │ │ - rsceq r0, r8, fp, lsr #2 │ │ │ │ + tsteq sl, r4, lsl r1 │ │ │ │ + rsceq r0, r8, r5, lsr #2 │ │ │ │ rsceq r0, r8, r8, ror #1 │ │ │ │ rsceq r0, r8, r8, ror #1 │ │ │ │ rsceq r0, r8, r8, ror #1 │ │ │ │ - cdpne 1, 8, cr0, cr3, cr1, {1} │ │ │ │ + mcrne 1, 4, r0, cr3, cr13, {0} │ │ │ │ vqdmulh.s d2, d0, d24 │ │ │ │ - ldm pc, {r0, r1, r2, r3, sl, pc}^ @ │ │ │ │ - ldreq pc, [r4, #-19] @ 0xffffffed │ │ │ │ - streq r0, [r0, #-1290] @ 0xfffffaf6 │ │ │ │ - ldrbteq r0, [r0], #1272 @ 0x4f8 │ │ │ │ - strbteq r0, [r2], #1256 @ 0x4e8 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - ldrbeq r0, [r7], #1037 @ 0x40d │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - strbeq r0, [r3], #1229 @ 0x4cd │ │ │ │ - streq r0, [sp], #-1209 @ 0xfffffb47 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [sp], #-1037 @ 0xfffffbf3 │ │ │ │ - streq r0, [r3], #1037 @ 0x40d │ │ │ │ - blcs acff50 <__bss_end__@@Base+0xa29318> │ │ │ │ - mcrge 6, 2, pc, cr15, cr15, {1} @ │ │ │ │ + ldm pc, {r0, r1, r4, r5, r6, r7, r8, r9, pc}^ @ │ │ │ │ + strbteq pc, [sl], #19 @ │ │ │ │ + ldrbeq r0, [r6], #1248 @ 0x4e0 │ │ │ │ + strbeq r0, [r6], #1230 @ 0x4ce │ │ │ │ + ldrteq r0, [r8], #1214 @ 0x4be │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + strteq r0, [pc], #1009 @ 8454 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + ldreq r0, [fp], #1189 @ 0x4a5 │ │ │ │ + mvnseq r0, #-1862270976 @ 0x91000000 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + mvnseq r0, #-1006632957 @ 0xc4000003 │ │ │ │ + ldrbeq r0, [pc], #-1009 @ 8490 │ │ │ │ + blcs acfea0 <__bss_end__@@Base+0xa29300> │ │ │ │ + mrcge 6, 2, APSR_nzcv, cr12, cr15, {1} │ │ │ │ @ instruction: 0xf852a202 │ │ │ │ ldrmi r3, [sl], #-35 @ 0xffffffdd │ │ │ │ svclt 0x00004710 │ │ │ │ - strdeq r0, [r0], -fp │ │ │ │ - andeq r0, r0, r9, ror #19 │ │ │ │ - ldrdeq r0, [r0], -r7 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - andeq r0, r0, r9, lsr #16 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - andeq r0, r0, r9, lsr #16 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - muleq r0, r9, sl │ │ │ │ - andeq r0, r0, r3, ror sl │ │ │ │ - andeq r0, r0, sp, asr #20 │ │ │ │ - andeq r0, r0, r9, lsr #20 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - @ instruction: 0xfffffc93 │ │ │ │ - andeq r0, r0, sp, lsl #20 │ │ │ │ - ldmibcc pc!, {r8, ip, sp, lr, pc}^ @ │ │ │ │ - svceq 0x001bf1b9 │ │ │ │ - stclge 6, cr15, [fp, #252]! @ 0xfc │ │ │ │ + andeq r0, r0, r7, lsr #19 │ │ │ │ + muleq r0, r5, r9 │ │ │ │ + andeq r0, r0, r3, lsl #19 │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + andeq r0, r0, r9, ror #15 │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + andeq r0, r0, r9, ror #15 │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + andeq r0, r0, r5, lsr sl │ │ │ │ + andeq r0, r0, r3, lsl sl │ │ │ │ + strdeq r0, [r0], -r1 │ │ │ │ + ldrdeq r0, [r0], -r1 │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0xfffffcad │ │ │ │ + @ instruction: 0x000009b9 │ │ │ │ + bcc 4958 │ │ │ │ + svceq 0x001bf1ba │ │ │ │ + ldclge 6, cr15, [r8, #252]! @ 0xfc │ │ │ │ @ instruction: 0xf853a302 │ │ │ │ - strbmi r9, [fp], #-41 @ 0xffffffd7 │ │ │ │ + ldrbmi sl, [r3], #-42 @ 0xffffffd6 │ │ │ │ svclt 0x00004718 │ │ │ │ - andeq r0, r0, r9, lsl r1 │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - andeq r0, r0, r9, asr #1 │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - andeq r0, r0, r9, asr #1 │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - @ instruction: 0xfffffbcb │ │ │ │ - andeq r0, r0, sp, asr r2 │ │ │ │ - @ instruction: 0x63b4f5aa │ │ │ │ - bcs 226fc │ │ │ │ - strbhi pc, [r7], #64 @ 0x40 @ │ │ │ │ - str r2, [r4, #1288]! @ 0x508 │ │ │ │ - @ instruction: 0x63b4f5aa │ │ │ │ + andeq r0, r0, sp, lsl #2 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + andeq r0, r0, r1, asr #1 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + andeq r0, r0, r1, asr #1 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + @ instruction: 0xfffffbe5 │ │ │ │ + andeq r0, r0, r1, asr r2 │ │ │ │ + @ instruction: 0x63b4f5a7 │ │ │ │ + stmdbcs r0, {r0, r3, r4, fp, sp, lr} │ │ │ │ + ldrhi pc, [r3], #64 @ 0x40 │ │ │ │ + ldr r2, [r1, #1288]! @ 0x508 │ │ │ │ + @ instruction: 0x63b4f5a7 │ │ │ │ stccs 8, cr6, [r0], {28} │ │ │ │ - ldcge 4, cr15, [pc, #508] @ 88a4 │ │ │ │ - @ instruction: 0x5600f8df │ │ │ │ - @ instruction: 0x63b2f5aa │ │ │ │ - ldrbtmi r4, [sp], #-1625 @ 0xfffff9a7 │ │ │ │ + stcge 4, cr15, [ip, #508]! @ 0x1fc │ │ │ │ + strbpl pc, [r8, #2271] @ 0x8df @ │ │ │ │ + @ instruction: 0x63b2f5a7 │ │ │ │ + ldrbtmi r9, [sp], #-2307 @ 0xfffff6fd │ │ │ │ movwcs lr, #10579 @ 0x2953 │ │ │ │ andvc pc, r6, r5, lsl #10 │ │ │ │ orrcs lr, r4, #3227648 @ 0x314000 │ │ │ │ - addvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ @ instruction: 0xf8c52301 │ │ │ │ - @ instruction: 0xf8c5941c │ │ │ │ + @ instruction: 0xf8c5a41c │ │ │ │ @ instruction: 0xf7fa320c │ │ │ │ - stmdbls r3, {r3, r4, r5, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ - addvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ + stmdbls r4, {r1, r5, r9, sl, fp, sp, lr, pc} │ │ │ │ subvc pc, r6, r5, lsl #10 │ │ │ │ - svc 0x0030f7fa │ │ │ │ + mrc 7, 0, APSR_nzcv, cr12, cr10, {7} │ │ │ │ ldrmi pc, [r8], #-2245 @ 0xfffff73b │ │ │ │ - ldrb r2, [lr, #-1281]! @ 0xfffffaff │ │ │ │ - @ instruction: 0x63b2f5aa │ │ │ │ - adcvs pc, ip, #713031680 @ 0x2a800000 │ │ │ │ + str r2, [pc, #1281] @ 8b31 │ │ │ │ + @ instruction: 0x63b2f5a7 │ │ │ │ + adcvs pc, ip, #700448768 @ 0x29c00000 │ │ │ │ tsteq r2, r3, asr r9 │ │ │ │ smlabteq r2, r2, r9, lr │ │ │ │ - ldrb r2, [r4, #-1285]! @ 0xfffffafb │ │ │ │ - @ instruction: 0x63b2f5aa │ │ │ │ - adcvs pc, ip, #713031680 @ 0x2a800000 │ │ │ │ + str r2, [r5, #1285] @ 0x505 │ │ │ │ + @ instruction: 0x63b2f5a7 │ │ │ │ + adcvs pc, ip, #700448768 @ 0x29c00000 │ │ │ │ tsteq r2, r3, asr r9 │ │ │ │ smlabteq r0, r2, r9, lr │ │ │ │ - @ instruction: 0xf50de56b │ │ │ │ - vst4.16 {d18-d21}, [pc], sl │ │ │ │ - ldrbmi r7, [r9], -r0, lsl #5 │ │ │ │ + @ instruction: 0xf50de57c │ │ │ │ + stmdbls r3, {r1, r3, r6, sp} │ │ │ │ subvc pc, r9, r0, lsl #10 │ │ │ │ - svc 0x0010f7fa │ │ │ │ - @ instruction: 0xf5aae7ea │ │ │ │ - @ instruction: 0xf5aa63b2 │ │ │ │ + ldcl 7, cr15, [lr, #1000]! @ 0x3e8 │ │ │ │ + @ instruction: 0xf5a7e7ec │ │ │ │ + @ instruction: 0xf5a763b2 │ │ │ │ ldmdb r3, {r2, r3, r5, r7, r9, sp, lr}^ │ │ │ │ stmib r2, {r1, r8}^ │ │ │ │ - strb r0, [r1, r4, lsl #2]! │ │ │ │ - ldrbvs pc, [r8, #-2271]! @ 0xfffff721 @ │ │ │ │ + strb r0, [r3, r4, lsl #2]! │ │ │ │ + strbvs pc, [ip, #-2271] @ 0xfffff721 @ │ │ │ │ addcs r2, r0, #0, 6 │ │ │ │ @ instruction: 0x61b6f44f │ │ │ │ - @ instruction: 0x46d1447e │ │ │ │ + sxtahmi r4, sl, lr, ror #8 │ │ │ │ @ instruction: 0xf00b4630 │ │ │ │ - addcs pc, r0, #1327104 @ 0x144000 │ │ │ │ + addcs pc, r0, #110592 @ 0x1b000 │ │ │ │ strmi r2, [r4], -r0, lsl #2 │ │ │ │ - ldc 7, cr15, [sl], {250} @ 0xfa │ │ │ │ - ldrbeq pc, [ip, #-2271] @ 0xfffff721 @ │ │ │ │ + ldcl 7, cr15, [r2], {250} @ 0xfa │ │ │ │ + ldreq pc, [r0, #-2271]! @ 0xfffff721 │ │ │ │ @ instruction: 0xf00b4478 │ │ │ │ - @ instruction: 0x4603fb11 │ │ │ │ - vaddl.s32 q3, d10, d19 │ │ │ │ + @ instruction: 0x4603fbdb │ │ │ │ + vaddl.s32 q3, d7, d19 │ │ │ │ @ instruction: 0x4630539c │ │ │ │ @ instruction: 0x51b4f240 │ │ │ │ movwcs r6, #2078 @ 0x81e │ │ │ │ adcseq r6, r6, r6, lsr #14 │ │ │ │ @ instruction: 0xf00b4632 │ │ │ │ - @ instruction: 0x4632f939 │ │ │ │ - orrvs pc, r1, sl, lsr #11 │ │ │ │ + ldrtmi pc, [r2], -r3, lsl #20 @ │ │ │ │ + orrvs pc, r1, r7, lsr #11 │ │ │ │ @ instruction: 0xf7fa6760 │ │ │ │ - movwcs lr, #3412 @ 0xd54 │ │ │ │ + movwcs lr, #3470 @ 0xd8e │ │ │ │ strvs r4, [r3, r0, lsr #12]! │ │ │ │ - @ instruction: 0xf9c0f7ff │ │ │ │ + @ instruction: 0xf9ccf7ff │ │ │ │ stmdacs r0, {r5, r8, r9, sl, fp, sp, lr} │ │ │ │ svcvs 0x0062d00f │ │ │ │ - bcc 13fbd0 <__bss_end__@@Base+0x98f98> │ │ │ │ + bcc 13fb14 <__bss_end__@@Base+0x98f74> │ │ │ │ and r4, r2, fp, lsr #12 │ │ │ │ addsmi r3, r8, #67108864 @ 0x4000000 │ │ │ │ @ instruction: 0xf852d007 │ │ │ │ - bvs fe2503bc <__bss_end__@@Base+0xfe1a9784> │ │ │ │ + bvs fe250300 <__bss_end__@@Base+0xfe1a9760> │ │ │ │ rscsle r2, r7, r0, lsl #18 │ │ │ │ @ instruction: 0xf7fe4620 │ │ │ │ - @ instruction: 0xf5a9ff9f │ │ │ │ + @ instruction: 0xf5aaffb5 │ │ │ │ mulls r3, r1, r0 │ │ │ │ - blx 1ec47c8 <__bss_end__@@Base+0x1e1db90> │ │ │ │ + blx ff34470c <__bss_end__@@Base+0xff29db6c> │ │ │ │ svcvs 0x00269803 │ │ │ │ movwcs r2, #512 @ 0x200 │ │ │ │ mvnsvc pc, #212860928 @ 0xcb00000 │ │ │ │ stmib r0, {r9, sl, fp, sp}^ │ │ │ │ stmib r0, {r2, r4, r8, r9, sp}^ │ │ │ │ ldcle 3, cr2, [r5, #-40]! @ 0xffffffd8 │ │ │ │ ldrsbtge pc, [r4], #-132 @ 0xffffff7c @ │ │ │ │ @@ -5242,240 +5221,232 @@ │ │ │ │ stcle 8, cr2, [r2, #-0] │ │ │ │ ldrdge pc, [r0], -r3 @ │ │ │ │ ldrbmi r9, [r5], -r4, lsl #30 │ │ │ │ tstcs r8, #805306368 @ 0x30000000 │ │ │ │ ldrbmi r4, [r9], -r2, asr #12 │ │ │ │ @ instruction: 0xf607fb03 │ │ │ │ stmibne r8!, {r0, r8, r9, sl, ip, sp} │ │ │ │ - stc2 0, cr15, [sl, #8]! │ │ │ │ + @ instruction: 0xff1cf002 │ │ │ │ ldrsbt pc, [r4], #-132 @ 0xffffff7c @ │ │ │ │ @ instruction: 0xf85e46c4 │ │ │ │ - bvs 754844 <__bss_end__@@Base+0x6adc0c> │ │ │ │ + bvs 754788 <__bss_end__@@Base+0x6adbe8> │ │ │ │ @ instruction: 0xa002f9b3 │ │ │ │ @ instruction: 0x000fe8bc │ │ │ │ ldrmi r4, [sl, #1070]! @ 0x42e │ │ │ │ ldm ip, {r0, r1, r2, r3, r9, sl, lr, pc} │ │ │ │ stm r6, {r0, r1} │ │ │ │ stclle 0, cr0, [r4], #12 │ │ │ │ ldrbtmi r9, [r5], -r3, lsl #20 │ │ │ │ andcc r6, r1, #38, 30 @ 0x98 │ │ │ │ ldclle 2, cr4, [r1], {150} @ 0x96 │ │ │ │ - ldrbtcs pc, [r0], #-2271 @ 0xfffff721 @ │ │ │ │ + strbcs pc, [r4], #-2271 @ 0xfffff721 @ │ │ │ │ cmppcs sl, sp, lsl #10 @ p-variant is OBSOLETE │ │ │ │ - strbtcc pc, [ip], #-2271 @ 0xfffff721 @ │ │ │ │ + strbcc pc, [r0], #-2271 @ 0xfffff721 @ │ │ │ │ msrvs R12_usr, r1 │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ stmdavs fp, {r1, r3, r4, fp, sp, lr} │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ - strtmi r8, [r0], -pc, ror #9 │ │ │ │ + @ instruction: 0x462084b5 │ │ │ │ stclcs 5, cr15, [sl, #-52] @ 0xffffffcc │ │ │ │ stcvs 2, cr15, [ip, #-52]! @ 0xffffffcc │ │ │ │ - blhi c3b68 <__bss_end__@@Base+0x1cf30> │ │ │ │ + blhi c3aac <__bss_end__@@Base+0x1cf0c> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - ldrt r2, [r4], #1287 @ 0x507 │ │ │ │ - strbcc pc, [r0], #-2271 @ 0xfffff721 @ │ │ │ │ - @ instruction: 0xf8d3447b │ │ │ │ - bcs 1d10a8 <__bss_end__@@Base+0x12a470> │ │ │ │ - ldrbhi pc, [lr], #832 @ 0x340 @ │ │ │ │ - ldrtne pc, [r4], #-2271 @ 0xfffff721 @ │ │ │ │ - ldrbtmi r2, [r9], #-1 │ │ │ │ - bl fed46880 <__bss_end__@@Base+0xfec9fc48> │ │ │ │ - @ instruction: 0xf8dfe4a5 │ │ │ │ - ldrbtmi r3, [fp], #-1068 @ 0xfffffbd4 │ │ │ │ - andcs pc, r8, #13828096 @ 0xd30000 │ │ │ │ - svceq 0x0006f012 │ │ │ │ - ldcge 4, cr15, [sp], {63} @ 0x3f │ │ │ │ - ldrne pc, [ip], #-2271 @ 0xfffff721 │ │ │ │ - @ instruction: 0xf8d32001 │ │ │ │ - ldrbtmi r2, [r9], #-516 @ 0xfffffdfc │ │ │ │ - bl fe8c68a4 <__bss_end__@@Base+0xfe81fc6c> │ │ │ │ - @ instruction: 0xf8dfe493 │ │ │ │ - ldrbtmi r3, [fp], #-1040 @ 0xfffffbf0 │ │ │ │ - andcc pc, r8, #13828096 @ 0xd30000 │ │ │ │ - str r9, [ip], #790 @ 0x316 │ │ │ │ - strcc pc, [r4], #-2271 @ 0xfffff721 │ │ │ │ - @ instruction: 0xf8d3447b │ │ │ │ - tstls r7, #8, 4 @ 0x80000000 │ │ │ │ - blls 541af0 <__bss_end__@@Base+0x49aeb8> │ │ │ │ + strb r2, [r7], #1287 @ 0x507 │ │ │ │ + ldrcc pc, [r4], #-2271 @ 0xfffff721 │ │ │ │ + ldmdavs r9, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ + vmls.i8 d18, d0, d7 │ │ │ │ + @ instruction: 0xf8df84a5 │ │ │ │ + ldrbtmi r0, [r8], #-1036 @ 0xfffffbf4 │ │ │ │ + ldcl 7, cr15, [r8, #-1000] @ 0xfffffc18 │ │ │ │ + @ instruction: 0xf8dfe4ba │ │ │ │ + ldrbtmi r3, [fp], #-1028 @ 0xfffffbfc │ │ │ │ + @ instruction: 0xf012685a │ │ │ │ + @ instruction: 0xf43f0f06 │ │ │ │ + ldmmi lr!, {r0, r1, r4, r5, r7, sl, fp, sp, pc}^ │ │ │ │ + ldrbtmi r6, [r8], #-2073 @ 0xfffff7e7 │ │ │ │ + stcl 7, cr15, [sl, #-1000] @ 0xfffffc18 │ │ │ │ + blmi fff41aa8 <__bss_end__@@Base+0xffe9af08> │ │ │ │ + ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ + strt r9, [r7], #790 @ 0x316 │ │ │ │ + ldrbtmi r4, [fp], #-3066 @ 0xfffff406 │ │ │ │ + tstls r7, #5963776 @ 0x5b0000 │ │ │ │ + blls 541a94 <__bss_end__@@Base+0x49aef4> │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ - ldmib sp, {r0, r1, r2, r3, r4, r5, r6, r9, pc}^ │ │ │ │ - b 148d140 <__bss_end__@@Base+0x13e6508> │ │ │ │ + ldmib sp, {r0, r1, r3, r5, r6, r9, pc}^ │ │ │ │ + b 148d070 <__bss_end__@@Base+0x13e64d0> │ │ │ │ @ instruction: 0xf0400301 │ │ │ │ - vsubw.s32 q4, q13, d20 │ │ │ │ + vrsra.s32 q4, , #25 │ │ │ │ mrcls 3, 0, r5, cr5, cr12, {4} │ │ │ │ - bls 32e918 <__bss_end__@@Base+0x287ce0> │ │ │ │ + bls 36e84c <__bss_end__@@Base+0x2c7cac> │ │ │ │ ldmdavs ip, {r0, r4, r5, r9, sl, lr} │ │ │ │ andsvs r1, sp, r5, ror #24 │ │ │ │ - cdp2 0, 9, cr15, cr0, cr0, {0} │ │ │ │ - orrvs pc, r1, #713031680 @ 0x2a800000 │ │ │ │ - strls r2, [r7], -r1, lsl #10 │ │ │ │ + cdp2 0, 5, cr15, cr14, cr0, {0} │ │ │ │ + orrvs pc, r1, #700448768 @ 0x29c00000 │ │ │ │ + strls r2, [r8], -r1, lsl #10 │ │ │ │ eoreq pc, r4, r3, asr #16 │ │ │ │ - movwls r9, #35604 @ 0x8b14 │ │ │ │ + movwls r9, #39700 @ 0x9b14 │ │ │ │ tstcc r6, #3358720 @ 0x334000 │ │ │ │ - stclmi 4, cr14, [pc], #404 @ 8ab0 │ │ │ │ - adcsvs pc, r4, #713031680 @ 0x2a800000 │ │ │ │ - @ instruction: 0x63b2f5aa │ │ │ │ - ldrbtmi r4, [ip], #-1625 @ 0xfffff9a7 │ │ │ │ + stclmi 4, cr14, [r9], #520 @ 0x208 │ │ │ │ + adcsvs pc, r4, #700448768 @ 0x29c00000 │ │ │ │ + @ instruction: 0x63b2f5a7 │ │ │ │ + ldrbtmi r9, [ip], #-2307 @ 0xfffff6fd │ │ │ │ @ instruction: 0xf5046815 │ │ │ │ ldmdb r3, {r1, r2, ip, sp, lr}^ │ │ │ │ stmib r4, {r1, r8, r9, sp}^ │ │ │ │ - vst2.32 {d18-d21}, [pc], r4 │ │ │ │ - movwcs r7, #4736 @ 0x1280 │ │ │ │ + movwcs r2, #4996 @ 0x1384 │ │ │ │ andcc pc, ip, #196, 16 @ 0xc40000 │ │ │ │ @ instruction: 0xf8c4232a │ │ │ │ @ instruction: 0xf7fa341c │ │ │ │ - stmdbls r3, {r2, r3, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ - addvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ + stmdbls r4, {r1, r2, r4, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ subvc pc, r6, r4, lsl #10 │ │ │ │ - ldcl 7, cr15, [r4, #1000]! @ 0x3e8 │ │ │ │ + ldcl 7, cr15, [r0], #1000 @ 0x3e8 │ │ │ │ ldrpl pc, [r8], #-2244 @ 0xfffff73c │ │ │ │ - bmi ff802490 <__bss_end__@@Base+0xff75b858> │ │ │ │ + bmi ff7023f8 <__bss_end__@@Base+0xff65b858> │ │ │ │ strbcs pc, [sl], #-1293 @ 0xfffffaf3 @ │ │ │ │ strbvc pc, [sl], #-1284 @ 0xfffffafc @ │ │ │ │ - @ instruction: 0x63acf5aa │ │ │ │ + @ instruction: 0x63acf5a7 │ │ │ │ strcs r4, [r5, #-1146] @ 0xfffffb86 │ │ │ │ muleq r3, r2, r8 │ │ │ │ subcs pc, sl, #54525952 @ 0x3400000 │ │ │ │ subvc pc, r9, #8388608 @ 0x800000 │ │ │ │ andcs r6, r0, r0, lsl r0 │ │ │ │ @ instruction: 0xf50d8021 │ │ │ │ vshl.s8 q1, q5, q2 │ │ │ │ stceq 4, cr3, [r9], {42} @ 0x2a │ │ │ │ tstcs r0, r1, lsr #32 │ │ │ │ smlabteq r4, r3, r9, lr │ │ │ │ smlabteq r2, r3, r9, lr │ │ │ │ smlabteq r0, r3, r9, lr │ │ │ │ - strcs lr, [r0, #-1059] @ 0xfffffbdd │ │ │ │ - ldc 4, cr14, [pc, #132] @ 8a28 │ │ │ │ - @ instruction: 0xf5aa7bc0 │ │ │ │ - @ instruction: 0xf5aa64af │ │ │ │ + strcs lr, [r0, #-1092] @ 0xfffffbbc │ │ │ │ + ldc 4, cr14, [pc, #264] @ 89d4 │ │ │ │ + @ instruction: 0xf5a77bbc │ │ │ │ + @ instruction: 0xf5a764af │ │ │ │ @ instruction: 0xf04f63b2 │ │ │ │ @ instruction: 0xf04f0800 │ │ │ │ @ instruction: 0xf6c30900 │ │ │ │ @ instruction: 0xed8479f0 │ │ │ │ - @ instruction: 0xf5aa7b00 │ │ │ │ + @ instruction: 0xf5a77b00 │ │ │ │ stc 12, cr6, [r4, #676] @ 0x2a4 │ │ │ │ strbtmi r7, [r6], -r2, lsl #22 │ │ │ │ stmdbhi r0, {r0, r1, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - blhi 1204490 <__bss_end__@@Base+0x115d858> │ │ │ │ + blhi 12043b8 <__bss_end__@@Base+0x115d818> │ │ │ │ stmdbhi r2, {r0, r1, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ stmib r3, {r1, r2, r8, sl, sp}^ │ │ │ │ @ instruction: 0xed848904 │ │ │ │ @ instruction: 0xcc0f7b04 │ │ │ │ - svcmi 0x00bfc60f │ │ │ │ - ldm r4, {r0, r1, r2, r3, r4, r5, r6, sl, lr} │ │ │ │ - @ instruction: 0xf50d0003 │ │ │ │ - vshl.s8 q1, q5, q2 │ │ │ │ - stm r6, {r2, r5, sl, lr} │ │ │ │ - ldm r7, {r0, r1} │ │ │ │ - stmib ip, {r0, r1, r2, r3}^ │ │ │ │ - stm r4, {r2, r8, fp, pc} │ │ │ │ - @ instruction: 0xf7ff000f │ │ │ │ - movwcs fp, #3056 @ 0xbf0 │ │ │ │ - blls 56d62c <__bss_end__@@Base+0x4c69f4> │ │ │ │ - movwls r2, #29955 @ 0x7503 │ │ │ │ - bllt ffa86a10 <__bss_end__@@Base+0xff9dfdd8> │ │ │ │ - @ instruction: 0xf5aa9b03 │ │ │ │ - movwls r6, #1202 @ 0x4b2 │ │ │ │ - stmdbls r7, {r1, r3, r4, r6, r9, sl, lr} │ │ │ │ - smlsdvs r2, r4, r9, lr │ │ │ │ - stmdals r4, {r0, r2, r8, r9, fp, ip, pc} │ │ │ │ - strvs lr, [r2, -r1, ror #17] │ │ │ │ - blx 7c6a28 <__bss_end__@@Base+0x71fdf0> │ │ │ │ - andle r2, r5, r3, lsl #16 │ │ │ │ - strmi r4, [r2], -fp, lsr #19 │ │ │ │ - ldrbtmi r2, [r9], #-1 │ │ │ │ - b ff846a28 <__bss_end__@@Base+0xff79fdf0> │ │ │ │ - ldrbmi r9, [sl], -r7, lsl #18 │ │ │ │ - movwls r9, #2819 @ 0xb03 │ │ │ │ - blls 154e8c <__bss_end__@@Base+0xae254> │ │ │ │ - @ instruction: 0xf7fe9804 │ │ │ │ - stmdacs r4, {r0, r2, r3, r9, fp, ip, sp, lr, pc} │ │ │ │ - stmibmi r4!, {r0, r2, ip, lr, pc} │ │ │ │ - andcs r4, r1, r2, lsl #12 │ │ │ │ - @ instruction: 0xf7fa4479 │ │ │ │ - blls 2435a4 <__bss_end__@@Base+0x19c96c> │ │ │ │ - movwcc r9, #6663 @ 0x1a07 │ │ │ │ - andscc r9, r8, #8, 6 @ 0x20000000 │ │ │ │ - svcmi 0x0000f5b3 │ │ │ │ - @ instruction: 0xf47f9207 │ │ │ │ - ldmmi sp, {r3, r4, r5, r7, r8, r9, fp, sp, pc} │ │ │ │ - @ instruction: 0xf7fa4478 │ │ │ │ - @ instruction: 0xf7ffecf6 │ │ │ │ - stmdacs sl!, {r1, r4, r5, r7, r8, r9, fp, ip, sp, pc} │ │ │ │ - mcrge 4, 0, pc, cr10, cr15, {3} @ │ │ │ │ - @ instruction: 0xf50d4d99 │ │ │ │ - movwcs r2, #1866 @ 0x74a │ │ │ │ - ldrbtmi r2, [sp], #-640 @ 0xfffffd80 │ │ │ │ - msrvc (UNDEF: 98), r0 │ │ │ │ - @ instruction: 0xf5074628 │ │ │ │ - @ instruction: 0xf00a7749 │ │ │ │ - strmi pc, [r4], -r5, lsr #31 │ │ │ │ - @ instruction: 0xf7fa4638 │ │ │ │ - mcrrne 11, 11, lr, r6, cr12 │ │ │ │ - ldrtmi r2, [r2], -r0, lsl #6 │ │ │ │ - vmax.s8 d20, d0, d24 │ │ │ │ - @ instruction: 0xf00a7163 │ │ │ │ - shadd8mi pc, r2, r9 @ │ │ │ │ - ldrpl pc, [ip], sl, lsr #5 │ │ │ │ - eorvs r4, r0, r9, lsr r6 │ │ │ │ - bl fecc6ab0 <__bss_end__@@Base+0xfec1fe78> │ │ │ │ - ldmdavs r5!, {r3, r5, r9, sl, lr} │ │ │ │ - strvs r2, [r5, -r0, lsl #6]! │ │ │ │ - msrvc (UNDEF: 103), r0 │ │ │ │ - strtmi r0, [sl], -sp, lsr #1 │ │ │ │ - @ instruction: 0xff88f00a │ │ │ │ - @ instruction: 0xf5aa462a │ │ │ │ - strbvs r6, [r0, -r1, lsl #3]! │ │ │ │ - bl fe8c6ad0 <__bss_end__@@Base+0xfe81fe98> │ │ │ │ - movwcs r6, #3877 @ 0xf25 │ │ │ │ - addsmi r6, sp, #51 @ 0x33 │ │ │ │ - stcle 7, cr6, [ip, #-652]! @ 0xfffffd74 │ │ │ │ - ldrcs r6, [r8], -r0, ror #30 │ │ │ │ - adcvs pc, ip, #713031680 @ 0x2a800000 │ │ │ │ - streq lr, [r5, #2816] @ 0xb00 │ │ │ │ - blcc 146c44 <__bss_end__@@Base+0xa000c> │ │ │ │ - @ instruction: 0x1002f9b3 │ │ │ │ - svclt 0x00c42900 │ │ │ │ - blx 46337e <__bss_end__@@Base+0x3bc746> │ │ │ │ - ldcle 1, cr3, [sl, #-24] @ 0xffffffe8 │ │ │ │ - blmi 44160 │ │ │ │ - ldc 3, cr3, [r3, #-96] @ 0xffffffa0 │ │ │ │ - vldr d5, [r3, #-24] @ 0xffffffe8 │ │ │ │ - vldr d6, [r3, #-16] │ │ │ │ - vadd.f64 d7, d5, d2 │ │ │ │ - vstr d5, [r3, #-16] │ │ │ │ - vldr d5, [r2, #24] │ │ │ │ - vadd.f64 d5, d6, d2 │ │ │ │ - vstr d6, [r3, #-20] @ 0xffffffec │ │ │ │ - vldr d6, [r2, #16] │ │ │ │ - vadd.f64 d6, d7, d4 │ │ │ │ - vstr d7, [r3, #-24] @ 0xffffffe8 │ │ │ │ - addmi r7, fp, #2048 @ 0x800 │ │ │ │ - addmi sp, r5, #228, 2 @ 0x39 │ │ │ │ - bmi 1a7d2b0 <__bss_end__@@Base+0x19d6678> │ │ │ │ - ldrbtmi r4, [sl], #-2153 @ 0xfffff797 │ │ │ │ - ldrbtmi r6, [r8], #-2081 @ 0xfffff7df │ │ │ │ - andcc pc, r0, #13762560 @ 0xd20000 │ │ │ │ - eormi pc, r3, r2, asr #16 │ │ │ │ - @ instruction: 0xf8c23301 │ │ │ │ - @ instruction: 0xf7fa3200 │ │ │ │ - stmdacs r0, {r1, r2, r4, r8, sl, fp, sp, lr, pc} │ │ │ │ - ldcge 4, cr15, [sl, #508]! @ 0x1fc │ │ │ │ - @ instruction: 0xf5aa4605 │ │ │ │ + @ instruction: 0xf8dfc60f │ │ │ │ + ldrbtmi lr, [lr], #748 @ 0x2ec │ │ │ │ + muleq r3, r4, r8 │ │ │ │ + strbcs pc, [sl], #-1293 @ 0xfffffaf3 @ │ │ │ │ + strtmi pc, [r4], #-516 @ 0xfffffdfc │ │ │ │ + andeq lr, r3, r6, lsl #17 │ │ │ │ + muleq pc, lr, r8 @ │ │ │ │ + stmdbhi r4, {r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ + andeq lr, pc, r4, lsl #17 │ │ │ │ + movwcs lr, #1040 @ 0x410 │ │ │ │ + blls 56d558 <__bss_end__@@Base+0x4c69b8> │ │ │ │ + movwls r2, #34051 @ 0x8503 │ │ │ │ + blls 141964 <__bss_end__@@Base+0x9adc4> │ │ │ │ + ldrtvs pc, [r2], #1447 @ 0x5a7 @ │ │ │ │ + stmdbls r8, {r8, r9, ip, pc} │ │ │ │ + stmdbhi r2, {r2, r4, r6, r8, fp, sp, lr, pc} │ │ │ │ + bls ef564 <__bss_end__@@Base+0x489c4> │ │ │ │ + stmia r1!, {r0, r2, fp, ip, pc}^ │ │ │ │ + @ instruction: 0xf7fe8902 │ │ │ │ + stmdacs r3, {r0, r1, r3, r6, r9, fp, ip, sp, lr, pc} │ │ │ │ + strmi sp, [r1], -r4 │ │ │ │ + ldrbtmi r4, [r8], #-2215 @ 0xfffff759 │ │ │ │ + ldc 7, cr15, [r2], {250} @ 0xfa │ │ │ │ + blls 12ed88 <__bss_end__@@Base+0x881e8> │ │ │ │ + tstcc r0, r0, lsl #6 │ │ │ │ + bls ef588 <__bss_end__@@Base+0x489e8> │ │ │ │ + @ instruction: 0xf7fe9805 │ │ │ │ + stmdacs r4, {r0, r1, r3, r4, r5, r9, fp, ip, sp, lr, pc} │ │ │ │ + strmi sp, [r1], -r4 │ │ │ │ + ldrbtmi r4, [r8], #-2208 @ 0xfffff760 │ │ │ │ + stc 7, cr15, [r2], {250} @ 0xfa │ │ │ │ + bls 22f5ac <__bss_end__@@Base+0x188a0c> │ │ │ │ + movwls r3, #37633 @ 0x9301 │ │ │ │ + @ instruction: 0xf5b33218 │ │ │ │ + andls r4, r8, #0, 30 │ │ │ │ + blge ff745b94 <__bss_end__@@Base+0xff69eff4> │ │ │ │ + ldrbtmi r4, [r8], #-2202 @ 0xfffff766 │ │ │ │ + ldc 7, cr15, [r8, #-1000]! @ 0xfffffc18 │ │ │ │ + bllt ff5c69a0 <__bss_end__@@Base+0xff51fe00> │ │ │ │ + @ instruction: 0xf47f282a │ │ │ │ + ldcmi 14, cr10, [r7, #132] @ 0x84 │ │ │ │ + stmdacs sl, {r0, r2, r3, r8, sl, ip, sp, lr, pc}^ │ │ │ │ + addcs r2, r0, #0, 6 │ │ │ │ + vqshl.s8 q10, , q0 │ │ │ │ + strtmi r7, [r8], -r2, ror #2 │ │ │ │ + stmdavc r9, {r3, r8, sl, ip, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf880f00b │ │ │ │ + strbmi r4, [r0], -r4, lsl #12 │ │ │ │ + stc 7, cr15, [r6], {250} @ 0xfa │ │ │ │ + movwcs r1, #3142 @ 0xc46 │ │ │ │ + @ instruction: 0x46284632 │ │ │ │ + msrvc (UNDEF: 99), r0 │ │ │ │ + @ instruction: 0xf874f00b │ │ │ │ + @ instruction: 0xf2a74632 │ │ │ │ + @ instruction: 0x4641569c │ │ │ │ + @ instruction: 0xf7fa6020 │ │ │ │ + @ instruction: 0x4628ebfe │ │ │ │ + movwcs r6, #2101 @ 0x835 │ │ │ │ + vabd.s8 d22, d0, d21 │ │ │ │ + adceq r7, sp, r7, ror #2 │ │ │ │ + @ instruction: 0xf00b462a │ │ │ │ + strtmi pc, [sl], -r3, ror #16 │ │ │ │ + orrvs pc, r1, r7, lsr #11 │ │ │ │ + @ instruction: 0xf7fa6760 │ │ │ │ + svcvs 0x0020ebee │ │ │ │ + eorsvs r2, r3, r0, lsl #6 │ │ │ │ + @ instruction: 0x67a34298 │ │ │ │ + svcvs 0x0065dd2c │ │ │ │ + @ instruction: 0xf5a72618 │ │ │ │ + bl 1614d0 <__bss_end__@@Base+0xba930> │ │ │ │ + @ instruction: 0xf8550080 │ │ │ │ + @ instruction: 0xf9b33b04 │ │ │ │ + stmdbcs r0, {r1, ip} │ │ │ │ + bvs 6f8940 <__bss_end__@@Base+0x651da0> │ │ │ │ + tstpcc r6, r1, lsl fp @ p-variant is OBSOLETE │ │ │ │ + ldc 13, cr13, [r2, #104] @ 0x68 │ │ │ │ + tstcc r8, #0, 22 │ │ │ │ + blpl 1c3e8c <__bss_end__@@Base+0x11d2ec> │ │ │ │ + blvs 143e90 <__bss_end__@@Base+0x9d2f0> │ │ │ │ + blvc c3e94 <__bss_end__@@Base+0x1d2f4> │ │ │ │ + blpl 144320 <__bss_end__@@Base+0x9d780> │ │ │ │ + blpl 1c3e5c <__bss_end__@@Base+0x11d2bc> │ │ │ │ + blpl c409c <__bss_end__@@Base+0x1d4fc> │ │ │ │ + blvs 184330 <__bss_end__@@Base+0xdd790> │ │ │ │ + blvs 143e68 <__bss_end__@@Base+0x9d2c8> │ │ │ │ + blvs 1440a8 <__bss_end__@@Base+0x9d508> │ │ │ │ + blvc 1c4340 <__bss_end__@@Base+0x11d7a0> │ │ │ │ + blvc c3e74 <__bss_end__@@Base+0x1d2d4> │ │ │ │ + mvnle r4, fp, lsl #5 │ │ │ │ + bicsle r4, r8, r8, lsr #5 │ │ │ │ + stmdami r7!, {r1, r2, r5, r6, r8, r9, fp, lr}^ │ │ │ │ + stmdavs r1!, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ + @ instruction: 0xf8d34478 │ │ │ │ + mrrcne 2, 0, r2, r5, cr8 │ │ │ │ + andpl pc, r8, #12779520 @ 0xc30000 │ │ │ │ + orreq lr, r2, #3072 @ 0xc00 │ │ │ │ + @ instruction: 0xf7fa609c │ │ │ │ + stmdacs r0, {r1, r4, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ + stclge 4, cr15, [ip, #508] @ 0x1fc │ │ │ │ + @ instruction: 0xf5a74605 │ │ │ │ mulls r3, r1, r0 │ │ │ │ - @ instruction: 0xf89cf002 │ │ │ │ + @ instruction: 0xf8fef002 │ │ │ │ andcs r9, r0, #196608 @ 0x30000 │ │ │ │ @ instruction: 0xf6cb2300 │ │ │ │ stmib r0, {r4, r5, r6, r7, r8, r9, ip, sp, lr}^ │ │ │ │ stmib r0, {r2, r4, r8, r9, sp}^ │ │ │ │ svcvs 0x0023230a │ │ │ │ @ instruction: 0xf77f2b00 │ │ │ │ - @ instruction: 0xf8d4ae57 │ │ │ │ + @ instruction: 0xf8d4ae67 │ │ │ │ @ instruction: 0xf10db074 │ │ │ │ @ instruction: 0xf04f08b0 │ │ │ │ @ instruction: 0x462f0a18 │ │ │ │ andls r4, r3, r6, lsr #12 │ │ │ │ eorne pc, r7, fp, asr r8 @ │ │ │ │ @ instruction: 0xf9b100bc │ │ │ │ stmdacs r0, {r1} │ │ │ │ @@ -5483,1142 +5454,1119 @@ │ │ │ │ strtmi ip, [r3], r0, lsr #32 │ │ │ │ stmdbeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ strbtmi r9, [r4], -r4, lsl #14 │ │ │ │ @ instruction: 0xf509fb0a │ │ │ │ strbmi r9, [r2], -r3, lsl #18 │ │ │ │ stmdbne r0!, {r0, r1, r2, r6, r9, sl, lr}^ │ │ │ │ stmdbeq r1, {r0, r3, r8, ip, sp, lr, pc} │ │ │ │ - blx 1244be2 <__bss_end__@@Base+0x119dfaa> │ │ │ │ + mcrr2 0, 0, pc, lr, cr2 @ │ │ │ │ ldrsbtgt pc, [r4], #-134 @ 0xffffff7a @ │ │ │ │ andcc pc, fp, ip, asr r8 @ │ │ │ │ @ instruction: 0xf9b36a1c │ │ │ │ svcgt 0x000fe002 │ │ │ │ strbmi r4, [lr, #1061] @ 0x425 │ │ │ │ ldm r7, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1} │ │ │ │ stclle 0, cr0, [r5], #12 │ │ │ │ strbtmi r9, [r3], r4, lsl #30 │ │ │ │ smladxcc r1, r3, pc, r6 @ │ │ │ │ ldclle 2, cr4, [r1], {187} @ 0xbb │ │ │ │ - @ instruction: 0xe61d4634 │ │ │ │ - ldrbtmi r4, [fp], #-2876 @ 0xfffff4c4 │ │ │ │ - andcs pc, r8, #13828096 @ 0xd30000 │ │ │ │ - @ instruction: 0xdc3f2a07 │ │ │ │ - tstcs r0, sl, lsr fp │ │ │ │ + @ instruction: 0xe62d4634 │ │ │ │ + ldrbtmi r4, [fp], #-2873 @ 0xfffff4c7 │ │ │ │ + stmdbcs r7, {r0, r3, r4, r6, fp, sp, lr} │ │ │ │ + blmi e3fc24 <__bss_end__@@Base+0xd99084> │ │ │ │ @ instruction: 0xf853447b │ │ │ │ - @ instruction: 0xf7fd0022 │ │ │ │ - @ instruction: 0xf5aafed5 │ │ │ │ - subsvs r6, r8, #-1744830462 @ 0x98000002 │ │ │ │ - blt ff786c28 <__bss_end__@@Base+0xff6dfff0> │ │ │ │ - adcsvs pc, r4, #713031680 @ 0x2a800000 │ │ │ │ - @ instruction: 0x63b2f5aa │ │ │ │ - @ instruction: 0x46599d1a │ │ │ │ - ldmdb r3, {r2, r4, fp, sp, lr}^ │ │ │ │ - stmib r5, {r1, r8, r9, sp}^ │ │ │ │ - @ instruction: 0xf8c52384 │ │ │ │ - vst3.8 {d16-d18}, [pc :64], ip │ │ │ │ - @ instruction: 0xf5057280 │ │ │ │ - movwcs r7, #4102 @ 0x1006 │ │ │ │ - andcc pc, ip, #12910592 @ 0xc50000 │ │ │ │ - ldcl 7, cr15, [r4], #-1000 @ 0xfffffc18 │ │ │ │ - vst2.8 {d25,d27}, [pc], r3 │ │ │ │ - @ instruction: 0xf5057280 │ │ │ │ - @ instruction: 0xf7fa7046 │ │ │ │ - vqdmulh.s32 d14, d10, d14[1] │ │ │ │ - mrcls 3, 0, r5, cr5, cr12, {4} │ │ │ │ - ldrmi pc, [r8], #-2245 @ 0xfffff73b │ │ │ │ - @ instruction: 0x4631681c │ │ │ │ - bls 32ec98 <__bss_end__@@Base+0x288060> │ │ │ │ - andsvs r1, sp, r5, ror #24 │ │ │ │ - ldc2l 0, cr15, [r2], {0} │ │ │ │ - orrvs pc, r1, #713031680 @ 0x2a800000 │ │ │ │ - strls r2, [r7], -r5, lsl #10 │ │ │ │ - eoreq pc, r4, r3, asr #16 │ │ │ │ - movwls r2, #33536 @ 0x8300 │ │ │ │ - blt fea86c90 <__bss_end__@@Base+0xfe9e0058> │ │ │ │ - andcs r4, r1, fp, lsl r9 │ │ │ │ - @ instruction: 0xf7fa4479 │ │ │ │ - @ instruction: 0xf7ffe9b2 │ │ │ │ - svclt 0x0000baa2 │ │ │ │ + tstcs r0, r1, lsr #32 │ │ │ │ + @ instruction: 0xff10f7fd │ │ │ │ + @ instruction: 0x63a6f5a7 │ │ │ │ + @ instruction: 0xf7ff6258 │ │ │ │ + vldrls d11, [fp, #-4] │ │ │ │ + adcsvs pc, r4, #700448768 @ 0x29c00000 │ │ │ │ + @ instruction: 0x63b2f5a7 │ │ │ │ + ldmdavs r4, {r0, r1, r8, fp, ip, pc} │ │ │ │ + ldreq pc, [ip], #-2245 @ 0xfffff73b │ │ │ │ + andvc pc, r6, r5, lsl #10 │ │ │ │ + movwcs lr, #10579 @ 0x2953 │ │ │ │ + orrcs lr, r4, #3227648 @ 0x314000 │ │ │ │ + @ instruction: 0xf8c52301 │ │ │ │ + @ instruction: 0xf7fa320c │ │ │ │ + stmdbls r4, {r1, r2, r4, r5, r6, r8, r9, fp, sp, lr, pc} │ │ │ │ + subvc pc, r6, r5, lsl #10 │ │ │ │ + bl 1c46b68 <__bss_end__@@Base+0x1b9ffc8> │ │ │ │ + orrspl pc, ip, #1879048202 @ 0x7000000a │ │ │ │ + @ instruction: 0xf8c59e15 │ │ │ │ + ldmdavs ip, {r3, r4, sl, lr} │ │ │ │ + stmdals r9, {r0, r4, r5, r9, sl, lr} │ │ │ │ + @ instruction: 0x1c659a0d │ │ │ │ + @ instruction: 0xf000601d │ │ │ │ + @ instruction: 0xf5a7fcab │ │ │ │ + strcs r6, [r5, #-897] @ 0xfffffc7f │ │ │ │ + @ instruction: 0xf8439608 │ │ │ │ + movwcs r0, #36 @ 0x24 │ │ │ │ + @ instruction: 0xf7ff9309 │ │ │ │ + ldmdami fp, {r0, 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instruction: 0xf5049904 │ │ │ │ @ instruction: 0xf7fa7046 │ │ │ │ - @ instruction: 0xf8c4ebb6 │ │ │ │ + @ instruction: 0xf8c4eac2 │ │ │ │ strcs r5, [r2, #-1048] @ 0xfffffbe8 │ │ │ │ - blt 106ddc <__bss_end__@@Base+0x601a4> │ │ │ │ - movwls r2, #33536 @ 0x8300 │ │ │ │ + blt d46ce4 <__bss_end__@@Base+0xca0144> │ │ │ │ + movwls r2, #37632 @ 0x9300 │ │ │ │ vldrls d9, [r4, #-84] @ 0xffffffac │ │ │ │ - @ instruction: 0xf7ff9307 │ │ │ │ - strcs fp, [r4, #-2556] @ 0xfffff604 │ │ │ │ - ldmiblt r9!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - strmi pc, [r4], #2271 @ 0x8df │ │ │ │ - ldrvs pc, [r2, #1450]! @ 0x5aa │ │ │ │ - @ instruction: 0x63b4f5aa │ │ │ │ - ldrbtmi r4, [ip], #-1625 @ 0xfffff9a7 │ │ │ │ - addvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ - stmdbhi r2, {r0, r2, r4, r6, r8, fp, sp, lr, pc} │ │ │ │ + @ instruction: 0xf7ff9308 │ │ │ │ + strcs fp, [r4, #-2605] @ 0xfffff5d3 │ │ │ │ + blt ac6cf8 <__bss_end__@@Base+0xa20158> │ │ │ │ + strbmi pc, [ip], #-2271 @ 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ldmdb r3, {r3, r8, fp, ip, pc}^ │ │ │ │ stmib r1, {r1, r8, r9, sp}^ │ │ │ │ @ instruction: 0xf7ff2302 │ │ │ │ - @ instruction: 0xf5aab94c │ │ │ │ - stmdbls r7, {r1, r4, r5, r7, r8, r9, sp, lr} │ │ │ │ + @ instruction: 0xf5a7b983 │ │ │ │ + stmdbls r8, {r1, r4, r5, r7, r8, r9, sp, lr} │ │ │ │ movwcs lr, #10579 @ 0x2953 │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ - stmdblt r3, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - ldrbtmi r4, [fp], #-3015 @ 0xfffff439 │ │ │ │ - andcs pc, r8, #13828096 @ 0xd30000 │ │ │ │ - vpmax.u8 d18, d0, d7 │ │ │ │ - stmibmi r5, {r3, r4, r5, r6, r8, pc}^ │ │ │ │ - ldrbtmi r2, [r9], #-1 │ │ │ │ - stmda r4, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - ldmdblt r5!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - ldrls r4, [r8, #-2754] @ 0xfffff53e │ │ │ │ - @ instruction: 0xf8d2447a │ │ │ │ - blcs 157a8 │ │ │ │ - subsmi fp, fp, #188, 30 @ 0x2f0 │ │ │ │ - andcc pc, r8, #12713984 @ 0xc20000 │ │ │ │ - addsvs pc, pc, #713031680 @ 0x2a800000 │ │ │ │ + ldmdblt sl!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldrbtmi r4, [fp], #-3004 @ 0xfffff444 │ │ │ │ + stmdbcs r7, {r0, r3, r4, r6, fp, sp, lr} │ │ │ │ + msrhi (UNDEF: 115), r0 │ │ │ │ + ldrbtmi r4, [r8], #-2234 @ 0xfffff746 │ │ │ │ + b 346e58 <__bss_end__@@Base+0x2a02b8> │ │ │ │ + stmdblt lr!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldrls r4, [r8, #-2744] @ 0xfffff548 │ │ │ │ + ldmdavs r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ + svclt 0x00bc2b00 │ │ │ │ + subsvs r4, r3, fp, asr r2 │ │ │ │ + addsvs pc, pc, #700448768 @ 0x29c00000 │ │ │ │ sbcsvs r3, r3, r1, lsl #22 │ │ │ │ tstls r4, #67108864 @ 0x4000000 │ │ │ │ - stmdblt r3!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - ldrbtmi r4, [sl], #-2746 @ 0xfffff546 │ │ │ │ - andcc pc, r8, #13762560 @ 0xd20000 │ │ │ │ - svclt 0x00bc2b00 │ │ │ │ - @ instruction: 0xf8c2425b │ │ │ │ - @ instruction: 0xf5aa3208 │ │ │ │ - blcc 61a34 <__bss_start@@Base+0x6994> │ │ │ │ + ldmdblt lr, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldrbtmi r4, [sl], #-2737 @ 0xfffff54f │ │ │ │ + blcs 22fe8 │ │ │ │ + subsmi fp, fp, #188, 30 @ 0x2f0 │ │ │ │ + @ instruction: 0xf5a76053 │ │ │ │ + blcc 61924 <__bss_start@@Base+0x691c> │ │ │ │ movwcs r6, #12435 @ 0x3093 │ │ │ │ movwcs r9, #4888 @ 0x1318 │ │ │ │ @ instruction: 0xf7ff9314 │ │ │ │ - bmi fecb7408 <__bss_end__@@Base+0xfec107d0> │ │ │ │ - @ instruction: 0xf8d2447a │ │ │ │ - blcs 157f0 │ │ │ │ - subsmi fp, fp, #188, 30 @ 0x2f0 │ │ │ │ - andcc pc, r8, #12713984 @ 0xc20000 │ │ │ │ - addsvs pc, pc, #713031680 @ 0x2a800000 │ │ │ │ + bmi feab73ec <__bss_end__@@Base+0xfea1084c> │ │ │ │ + ldmdavs r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ + svclt 0x00bc2b00 │ │ │ │ + subsvs r4, r3, fp, asr r2 │ │ │ │ + addsvs pc, pc, #700448768 @ 0x29c00000 │ │ │ │ subsvs r3, r3, r1, lsl #22 │ │ │ │ tstls r8, #134217728 @ 0x8000000 │ │ │ │ tstls r4, #67108864 @ 0x4000000 │ │ │ │ - ldmlt sp!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - ldrbtmi r4, [sl], #-2729 @ 0xfffff557 │ │ │ │ - andcc pc, r8, #13762560 @ 0xd20000 │ │ │ │ - svclt 0x00bc2b00 │ │ │ │ - @ instruction: 0xf8c2425b │ │ │ │ - @ instruction: 0xf5aa3208 │ │ │ │ - blcc 61a80 <__bss_start@@Base+0x69e0> │ │ │ │ + ldmdblt ip!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldrbtmi r4, [sl], #-2722 @ 0xfffff55e │ │ │ │ + blcs 2302c │ │ │ │ + subsmi fp, fp, #188, 30 @ 0x2f0 │ │ │ │ + @ instruction: 0xf5a76053 │ │ │ │ + blcc 61968 <__bss_start@@Base+0x6960> │ │ │ │ movwcs r6, #4115 @ 0x1013 │ │ │ │ tstls r4, #24, 6 @ 0x60000000 │ │ │ │ - stmialt fp!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdblt ip!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ movwcs r9, #2581 @ 0xa15 │ │ │ │ tstls r8, #8388608 @ 0x800000 │ │ │ │ - andls r9, r7, #8, 6 @ 0x20000000 │ │ │ │ + andls r9, r8, #603979776 @ 0x24000000 │ │ │ │ stmib sp, {r2, r4, r8, r9, ip, pc}^ │ │ │ │ @ instruction: 0xf7ff3316 │ │ │ │ - ldmibmi ip, {r5, r6, r7, fp, ip, sp, pc} │ │ │ │ - blls d1030 <__bss_end__@@Base+0x2a3f8> │ │ │ │ - @ instruction: 0xf7f94479 │ │ │ │ - @ instruction: 0xf7ffefe8 │ │ │ │ - bcs 77398 <__bss_start@@Base+0x1c2f8> │ │ │ │ - rscshi pc, sp, r0, asr #6 │ │ │ │ - strcs r2, [r1, #-792] @ 0xfffffce8 │ │ │ │ - stmdbeq r1, {r0, r1, r2, r3, r6, r9, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf8cdaa88 │ │ │ │ - blx f10de <__bss_end__@@Base+0x4a4a6> │ │ │ │ - blls 786854 <__bss_end__@@Base+0x6dfc1c> │ │ │ │ - @ instruction: 0xf5a39212 │ │ │ │ - @ instruction: 0xf2aa747c │ │ │ │ + ldmmi r6, {r0, r5, r8, fp, ip, sp, pc} │ │ │ │ + ldrbtmi r9, [r8], #-2564 @ 0xfffff5fc │ │ │ │ + ldmib r8!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmdblt sl, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + vpmax.u8 d18, d0, d1 │ │ │ │ + tstcs r8, #242 @ 0xf2 │ │ │ │ + b 13d232c <__bss_end__@@Base+0x132b78c> │ │ │ │ + bge fe20b430 <__bss_end__@@Base+0xfe164890> │ │ │ │ + blx eeb5a <__bss_end__@@Base+0x47fba> │ │ │ │ + blls 7c6738 <__bss_end__@@Base+0x71fb98> │ │ │ │ + @ instruction: 0xf5a39213 │ │ │ │ + @ instruction: 0xf2a7747c │ │ │ │ @ instruction: 0xf1a6539c │ │ │ │ stmib sp, {r3, r4, fp}^ │ │ │ │ - stmib sp, {r1, r2, r3, r4, r8, fp, sp, lr}^ │ │ │ │ - bls 5abce8 <__bss_end__@@Base+0x5050b0> │ │ │ │ + @ instruction: 0xf8cd691f │ │ │ │ + bls 5a915c <__bss_end__@@Base+0x5025bc> │ │ │ │ vpmax.u8 d18, d0, d1 │ │ │ │ - stmdbls r0!, {r2, r7, pc} │ │ │ │ + stmdbls r1!, {r2, r7, pc} │ │ │ │ ldmdavs sl, {r0, r5, r7, r9, sl, lr} │ │ │ │ - tstls r7, r1, lsr #8 │ │ │ │ - stmib sp, {r0, r3, r8, fp, ip, pc}^ │ │ │ │ - @ instruction: 0xf5a1451b │ │ │ │ - @ instruction: 0x910b619d │ │ │ │ - @ instruction: 0x910a1c91 │ │ │ │ - tstls r0, #507904 @ 0x7c000 │ │ │ │ - andsls r4, r1, #167772160 @ 0xa000000 │ │ │ │ - @ instruction: 0xb01cf8dd │ │ │ │ - beq 64573c <__bss_end__@@Base+0x59eb04> │ │ │ │ - ldrbmi r9, [sl], -r9, lsl #22 │ │ │ │ - @ instruction: 0xf5a39e0b │ │ │ │ + tstls r8, r1, lsr #8 │ │ │ │ + stmib sp, {r1, r3, r8, fp, ip, pc}^ │ │ │ │ + @ instruction: 0xf5a1451c │ │ │ │ + @ instruction: 0x910c619d │ │ │ │ + @ instruction: 0x910b1c91 │ │ │ │ + tstls r1, #32, 18 @ 0x80000 │ │ │ │ + andsls r4, r2, #167772160 @ 0xa000000 │ │ │ │ + ldrdlt pc, [r0], -sp @ │ │ │ │ + beq 645620 <__bss_end__@@Base+0x59ea80> │ │ │ │ + ldrbmi r9, [sl], -sl, lsl #22 │ │ │ │ + @ instruction: 0xf5a39e0c │ │ │ │ andscc r6, r8, #-1711276032 @ 0x9a000000 │ │ │ │ ldmvs r7, {r0, r1, r5, r7, r8, sl, ip, sp, lr, pc} │ │ │ │ - ldm sl!, {r3, r9, ip, pc} │ │ │ │ + ldm sl!, {r0, r3, r9, ip, pc} │ │ │ │ ldrtmi r0, [r5], -pc │ │ │ │ - strgt r4, [pc, #-1631] @ 8a55 │ │ │ │ + strgt r4, [pc, #-1631] @ 8939 │ │ │ │ muleq r3, sl, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ - strgt ip, [pc], #-3855 @ 90c0 │ │ │ │ + strgt ip, [pc], #-3855 @ 8fa4 │ │ │ │ muleq r3, r7, r8 │ │ │ │ andeq lr, r3, r4, lsl #17 │ │ │ │ - svcgt 0x000f9f08 │ │ │ │ + svcgt 0x000f9f09 │ │ │ │ andeq lr, pc, r8, lsr #17 │ │ │ │ - strls r9, [r8, -ip, lsl #20] │ │ │ │ + strls r9, [r9, -sp, lsl #20] │ │ │ │ ldrdeq lr, [r0, -r7] │ │ │ │ andeq lr, r3, r8, lsl #17 │ │ │ │ andcs r4, r3, r1, lsr r6 │ │ │ │ - blx fe8450e4 <__bss_end__@@Base+0xfe79e4ac> │ │ │ │ - strls r9, [lr], -sl, lsl #18 │ │ │ │ - strls r4, [fp], -pc, asr #12 │ │ │ │ + blx fe544fc8 <__bss_end__@@Base+0xfe49e428> │ │ │ │ + strls r9, [pc], -fp, lsl #18 │ │ │ │ + strls r4, [ip], -pc, asr #12 │ │ │ │ cdpeq 1, 1, cr15, cr8, cr9, {5} │ │ │ │ - @ instruction: 0xf1099e12 │ │ │ │ - blls 24b558 <__bss_end__@@Base+0x1a4920> │ │ │ │ - andslt pc, ip, sp, asr #17 │ │ │ │ - bleq 64552c <__bss_end__@@Base+0x59e8f4> │ │ │ │ + @ instruction: 0xf1099e13 │ │ │ │ + blls 28b43c <__bss_end__@@Base+0x1e489c> │ │ │ │ + eorlt pc, r0, sp, asr #17 │ │ │ │ + bleq 645410 <__bss_end__@@Base+0x59e870> │ │ │ │ ldcvs 5, cr15, [sl], {163} @ 0xa3 │ │ │ │ - eorsgt pc, ip, sp, asr #17 │ │ │ │ + subgt pc, r0, sp, asr #17 │ │ │ │ vstmiaeq r1, {d14-d16} │ │ │ │ - @ instruction: 0xf8cd9e0e │ │ │ │ - @ instruction: 0xf84cc034 │ │ │ │ + @ instruction: 0xf8cd9e0f │ │ │ │ + @ instruction: 0xf84cc038 │ │ │ │ @ instruction: 0xf5a30c08 │ │ │ │ ldm fp!, {r0, r1, r2, r4, r7, sl, fp, sp, lr} │ │ │ │ strgt r0, [pc], -pc │ │ │ │ - ldm r3, {r3, r8, r9, fp, ip, pc} │ │ │ │ + ldm r3, {r0, r3, r8, r9, fp, ip, pc} │ │ │ │ stm r5, {r0, r1} │ │ │ │ svcgt 0x000f0003 │ │ │ │ - strgt r9, [pc, #-3343] @ 8421 │ │ │ │ + strgt r9, [pc, #-3344] @ 8304 │ │ │ │ muleq r3, r7, r8 │ │ │ │ andeq lr, r3, r4, lsl #17 │ │ │ │ @ instruction: 0x000fe8be │ │ │ │ andeq lr, pc, ip, lsr #17 │ │ │ │ - ldm sl, {r4, r8, r9, fp, ip, pc} │ │ │ │ + ldm sl, {r0, r4, r8, r9, fp, ip, pc} │ │ │ │ stm r8, {r0, r1} │ │ │ │ - stcls 0, cr0, [sl], {3} │ │ │ │ + stcls 0, cr0, [fp], {3} │ │ │ │ ldmib sp, {r0, r1, sp}^ │ │ │ │ - andsvs r1, ip, fp, lsl #4 │ │ │ │ - blx 19c5158 <__bss_end__@@Base+0x191e520> │ │ │ │ - cdpls 15, 0, cr9, cr13, cr7, {0} │ │ │ │ + andsvs r1, ip, ip, lsl #4 │ │ │ │ + blx 16c503c <__bss_end__@@Base+0x161e49c> │ │ │ │ + cdpls 15, 0, cr9, cr14, cr8, {0} │ │ │ │ @ instruction: 0xf1071ca3 │ │ │ │ - andls r0, r7, #24, 4 @ 0x80000001 │ │ │ │ - @ instruction: 0xf8469a11 │ │ │ │ + andls r0, r8, #24, 4 @ 0x80000001 │ │ │ │ + @ instruction: 0xf8469a12 │ │ │ │ addsmi r0, sl, #4, 24 @ 0x400 │ │ │ │ - orrle r9, pc, sl, lsl #6 │ │ │ │ - ldrmi lr, [fp, #-2525] @ 0xfffff623 │ │ │ │ - bls 7afdb8 <__bss_end__@@Base+0x709180> │ │ │ │ + orrle r9, pc, fp, lsl #6 │ │ │ │ + ldrmi lr, [ip, #-2525] @ 0xfffff623 │ │ │ │ + bls 7efca0 <__bss_end__@@Base+0x749100> │ │ │ │ ldrmi r3, [r4], #-1281 @ 0xfffffaff │ │ │ │ adcmi r9, sl, #94208 @ 0x17000 │ │ │ │ svcge 0x0071f47f │ │ │ │ - movwls r2, #33536 @ 0x8300 │ │ │ │ + movwls r2, #37632 @ 0x9300 │ │ │ │ strcs r9, [r1, #-2837] @ 0xfffff4eb │ │ │ │ - ldrdge pc, [r4], -sp @ │ │ │ │ - ldrdlt pc, [r4], sp │ │ │ │ - @ instruction: 0xf7ff9307 │ │ │ │ - blls 637234 <__bss_end__@@Base+0x5905fc> │ │ │ │ - vstrle d18, [r7, #-0] │ │ │ │ - @ instruction: 0xf5aa4b3e │ │ │ │ - @ instruction: 0xf8cd669f │ │ │ │ - strcs sl, [r0], #-44 @ 0xffffffd4 │ │ │ │ - @ instruction: 0xf50d9f08 │ │ │ │ - @ instruction: 0xf8dd78a0 │ │ │ │ - ldrcs r9, [r8, #-96] @ 0xffffffa0 │ │ │ │ - ldrsbtge pc, [r4], #-141 @ 0xffffff73 @ │ │ │ │ - andls r4, sl, fp, ror r4 │ │ │ │ - @ instruction: 0xf8cd9309 │ │ │ │ - @ instruction: 0xf856b034 │ │ │ │ - ldrmi fp, [fp, #2820]! @ 0xb04 │ │ │ │ - @ instruction: 0xf5aada23 │ │ │ │ - blx 1643da <__bss_end__@@Base+0xbd7a2> │ │ │ │ - strcc r8, [r1], #-3588 @ 0xfffff1fc │ │ │ │ - blx 15a862 <__bss_end__@@Base+0xb3c2a> │ │ │ │ - ldm ip!, {r0, r1, r3, sl, fp, lr, pc} │ │ │ │ - stmia lr!, {r0, r1, r2, r3} │ │ │ │ - ldm ip, {r0, r1, r2, r3} │ │ │ │ - stm lr, {r0, r1} │ │ │ │ - mvnle r0, r3 │ │ │ │ - bls 2c3968 <__bss_end__@@Base+0x21cd30> │ │ │ │ - ldrsbtlt pc, [r4], -sp @ │ │ │ │ - orrspl pc, ip, #-1610612726 @ 0xa000000a │ │ │ │ - ldmdals r8, {r2, r3, r9, fp, ip, pc} │ │ │ │ - ldmdavs ip, {r0, r6, r9, sl, lr} │ │ │ │ - andsvs r1, sp, r5, ror #24 │ │ │ │ - blx 34520c <__bss_end__@@Base+0x29e5d4> │ │ │ │ - orrvs pc, r1, #713031680 @ 0x2a800000 │ │ │ │ - eoreq pc, r4, r3, asr #16 │ │ │ │ - stmdbls r9, {r6, r7, r8, sl, sp, lr, pc} │ │ │ │ - @ instruction: 0x465a463b │ │ │ │ - andcs r9, r1, r0, lsl #8 │ │ │ │ - mcr 7, 7, pc, cr14, cr9, {7} @ │ │ │ │ - ldmdami lr, {r0, r1, r4, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ + movwls r9, #36618 @ 0x8f0a │ │ │ │ + stmdalt ip!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blcs 2fcdc │ │ │ │ + blmi f00580 <__bss_end__@@Base+0xe599e0> │ │ │ │ + ldrvs pc, [pc], r7, lsr #11 │ │ │ │ + streq lr, [fp, -sp, asr #19] │ │ │ │ + ldrbtmi r2, [fp], #-1024 @ 0xfffffc00 │ │ │ │ + blls 7adcb8 <__bss_end__@@Base+0x707118> │ │ │ │ + stmibvc r0!, {r0, r2, r3, r8, sl, ip, sp, lr, pc} │ │ │ │ + ldrdlt pc, [r4], -sp @ │ │ │ │ + svcls 0x00182518 │ │ │ │ + stmvs r1, {r0, r1, r5, r7, r8, sl, ip, sp, lr, pc} │ │ │ │ + blge 1471fc <__bss_end__@@Base+0xa065c> │ │ │ │ + ble 7da810 <__bss_end__@@Base+0x733c70> │ │ │ │ + @ instruction: 0x8c0afb05 │ │ │ │ + vmlals.f64 d15, d4, d5 │ │ │ │ + adcmi r3, r7, #16777216 @ 0x1000000 │ │ │ │ + @ instruction: 0x000fe8bc │ │ │ │ + andeq lr, pc, lr, lsr #17 │ │ │ │ + muleq r3, ip, r8 │ │ │ │ + andeq lr, r3, lr, lsl #17 │ │ │ │ + ldmib sp, {r2, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ + vabdl.s32 q5, d7, d11 │ │ │ │ + bls 35df40 <__bss_end__@@Base+0x2b73a0> │ │ │ │ + ldmdals r8, {r0, r3, r6, r9, sl, lr} │ │ │ │ + stclne 8, cr6, [r5], #-112 @ 0xffffff90 │ │ │ │ + @ instruction: 0xf000601d │ │ │ │ + @ instruction: 0xf5a7fa09 │ │ │ │ + @ instruction: 0xf8436381 │ │ │ │ + ldrb r0, [pc, #36] @ 910c │ │ │ │ + strtmi r9, [r3], -sl, lsl #16 │ │ │ │ + @ instruction: 0x4651465a │ │ │ │ + stmia sl, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdami lr, {r3, r4, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fa4478 │ │ │ │ - ldr lr, [r3, #2334]! @ 0x91e │ │ │ │ - stmiavc r0!, {r0, r2, r3, r8, sl, ip, sp, lr, pc} │ │ │ │ - blls 5431b8 <__bss_end__@@Base+0x49c580> │ │ │ │ - movwls r2, #34049 @ 0x8501 │ │ │ │ - movwls r9, #31509 @ 0x7b15 │ │ │ │ - svclt 0x00d1f7fe │ │ │ │ - ldm sl!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldrb lr, [r3, #2442] @ 0x98a │ │ │ │ + stmibvc r0!, {r0, r2, r3, r8, sl, ip, sp, lr, pc} │ │ │ │ + blls 54308c <__bss_end__@@Base+0x49c4ec> │ │ │ │ + movwls r2, #38145 @ 0x9501 │ │ │ │ + movwls r9, #35605 @ 0x8b15 │ │ │ │ + ldmdalt lr, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb lr!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ movwcs r4, #2582 @ 0xa16 │ │ │ │ vtst.8 d20, d0, d6 │ │ │ │ ldrbtmi r6, [sl], #-297 @ 0xfffffed7 │ │ │ │ @ instruction: 0xf0094478 │ │ │ │ - @ instruction: 0xf7f9fae7 │ │ │ │ - bmi 504c38 <__bss_end__@@Base+0x45e000> │ │ │ │ + @ instruction: 0xf7f9ff37 │ │ │ │ + bmi 504cc8 <__bss_end__@@Base+0x45e128> │ │ │ │ ldmdami r3, {r8, r9, sp} │ │ │ │ bicsvs pc, r8, pc, asr #8 │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - blx ff745294 <__bss_end__@@Base+0xff69e65c> │ │ │ │ - mcr 7, 3, pc, cr10, cr9, {7} @ │ │ │ │ - muleq r5, r6, r3 │ │ │ │ + @ instruction: 0xff2cf009 │ │ │ │ + mrc 7, 6, APSR_nzcv, cr10, cr9, {7} │ │ │ │ + andeq r2, r5, r8, ror #7 │ │ │ │ + andeq r2, r5, lr, ror #6 │ │ │ │ andeq r2, r5, r6, lsl r3 │ │ │ │ - @ instruction: 0x000522b6 │ │ │ │ - andeq r2, r5, r6, asr r1 │ │ │ │ - andeq r0, r4, lr, lsr #27 │ │ │ │ - andeq r2, r5, r8, lsr r1 │ │ │ │ - andeq r2, r5, r6, lsl r1 │ │ │ │ - strdeq r2, [r5], -r0 │ │ │ │ - andeq r2, r5, sl, asr #1 │ │ │ │ - andeq r0, r4, r8, asr #25 │ │ │ │ + andeq r2, r5, r2, asr #3 │ │ │ │ + andeq r0, r4, lr, lsr #28 │ │ │ │ + andeq r2, r5, r8, lsr #3 │ │ │ │ + andeq r2, r5, sl, lsl #3 │ │ │ │ + andeq r2, r5, r8, ror #2 │ │ │ │ + andeq r2, r5, r6, asr #2 │ │ │ │ + andeq r0, r4, sl, asr sp │ │ │ │ + andeq r0, r4, sl, asr #25 │ │ │ │ andeq r0, r4, r0, lsr #24 │ │ │ │ - andeq r0, r4, r8, ror fp │ │ │ │ - @ instruction: 0x00040ab2 │ │ │ │ - andeq r0, r4, r4, ror #18 │ │ │ │ - andeq r0, r4, ip, asr fp │ │ │ │ - andeq r0, r4, lr, asr #18 │ │ │ │ + andeq r0, r4, sl, asr fp │ │ │ │ + andeq r0, r4, r0, lsl sl │ │ │ │ + andeq r0, r4, r4, lsl #24 │ │ │ │ + strdeq r0, [r4], -sl │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb604bc <__bss_end__@@Base+0xfeab9884> │ │ │ │ + bl feb6038c <__bss_end__@@Base+0xfeab97ec> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [fp], {248} @ 0xf8 │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ stmdavs r3, {r4, r5, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf00a6023 │ │ │ │ - stmdavs r0!, {r0, r2, r3, r4, r5, sl, fp, ip, sp, lr, pc} │ │ │ │ + stmdavs r0!, {r0, r6, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ ldrbtmi r4, [ip], #-3078 @ 0xfffff3fa │ │ │ │ teqlt r0, r0, ror #16 │ │ │ │ rsbvs r6, r3, r3, asr #16 │ │ │ │ - ldc2 0, cr15, [r2], #-40 @ 0xffffffd8 │ │ │ │ + ldc2 0, cr15, [r6, #-40]! @ 0xffffffd8 │ │ │ │ stmdacs r0, {r5, r6, fp, sp, lr} │ │ │ │ ldclt 1, cr13, [r0, #-992] @ 0xfffffc20 │ │ │ │ - andeq r2, r5, ip, ror #6 │ │ │ │ - andeq r2, r5, r6, asr r3 │ │ │ │ + andeq r2, r5, r4, lsl #8 │ │ │ │ + andeq r2, r5, lr, ror #7 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb60500 <__bss_end__@@Base+0xfeab98c8> │ │ │ │ + bl feb603d0 <__bss_end__@@Base+0xfeab9830> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi 40d2e8 <__bss_end__@@Base+0x3666b0> │ │ │ │ + blmi 40d1b8 <__bss_end__@@Base+0x366618> │ │ │ │ ldmdavs ip, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ stmdavs r2!, {r2, r6, r8, ip, sp, pc}^ │ │ │ │ andsvs r4, sl, r0, lsr #12 │ │ │ │ stmib r4, {r8, r9, sp}^ │ │ │ │ stmib r4, {r8, r9, ip, sp}^ │ │ │ │ ldclt 3, cr3, [r0, #-8] │ │ │ │ strtmi r4, [r3], -sl, lsl #16 │ │ │ │ cmpcs r4, r0, lsl r2 │ │ │ │ @ instruction: 0xf00a4478 │ │ │ │ - @ instruction: 0x4604fb5f │ │ │ │ + strmi pc, [r4], -r3, ror #24 │ │ │ │ ldrbtmi r4, [r8], #-2055 @ 0xfffff7f9 │ │ │ │ - cdp2 0, 11, cr15, cr2, cr10, {0} │ │ │ │ + @ instruction: 0xffb6f00a │ │ │ │ strtmi r2, [r0], -r0, lsl #6 │ │ │ │ movwcc lr, #2500 @ 0x9c4 │ │ │ │ movwcc lr, #10692 @ 0x29c4 │ │ │ │ svclt 0x0000bd10 │ │ │ │ - andeq r2, r5, r8, lsr #6 │ │ │ │ - andeq r0, r4, r4, lsl #24 │ │ │ │ + andeq r2, r5, r0, asr #7 │ │ │ │ + andeq r0, r4, ip, lsr #25 │ │ │ │ @ instruction: 0xffffff7f │ │ │ │ eorsle r2, pc, r0, lsl #16 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00e8f8cc │ │ │ │ strmi r6, [r6], -r3, lsl #16 │ │ │ │ - blle d13f70 <__bss_end__@@Base+0xc6d338> │ │ │ │ + blle d13e40 <__bss_end__@@Base+0xc6d2a0> │ │ │ │ teqlt ip, #68, 16 @ 0x440000 │ │ │ │ ldrbtmi r4, [fp], #-2846 @ 0xfffff4e2 │ │ │ │ ldmdavs sl, {r0, r1, sp, lr, pc}^ │ │ │ │ subsvs r6, sp, sl, rrx │ │ │ │ strtmi fp, [r5], -r4, lsl #6 │ │ │ │ stmdbcs r0, {r2, r5, r6, fp, sp, lr} │ │ │ │ svcmi 0x001ad0f7 │ │ │ │ ldrdhi pc, [r8], #-143 @ 0xffffff71 @ │ │ │ │ ldrbtmi r4, [r8], #1151 @ 0x47f │ │ │ │ - bvs 6413c8 <__bss_end__@@Base+0x59a790> │ │ │ │ - blx ff6453c6 <__bss_end__@@Base+0xff59e78e> │ │ │ │ + bvs 641298 <__bss_end__@@Base+0x59a6f8> │ │ │ │ + ldc2l 0, cr15, [ip], {10} │ │ │ │ @ instruction: 0xf00a6828 │ │ │ │ - ldmdavs fp!, {r0, r2, r4, r6, r7, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmdavs fp!, {r0, r3, r4, r6, r7, sl, fp, ip, sp, lr, pc}^ │ │ │ │ rsbsvs r6, sp, fp, rrx │ │ │ │ stmdavs r3!, {r2, r5, r6, r8, ip, sp, pc}^ │ │ │ │ ldrmi r4, [ip], -r5, lsr #12 │ │ │ │ - blcs 23460 │ │ │ │ + blcs 23330 │ │ │ │ @ instruction: 0xf8d8d1ef │ │ │ │ rsbvs r3, fp, r4 │ │ │ │ andpl pc, r4, r8, asr #17 │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ @ instruction: 0xf04f4b0d │ │ │ │ ldrshtvs r3, [r2], -pc │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ andsvs r6, lr, r2, ror r0 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ - bmi 25b19c <__bss_end__@@Base+0x1b4564> │ │ │ │ + bmi 25b06c <__bss_end__@@Base+0x1b44cc> │ │ │ │ stmdami r9, {r8, r9, sp} │ │ │ │ ldrbtmi r2, [sl], #-347 @ 0xfffffea5 │ │ │ │ @ instruction: 0xf0094478 │ │ │ │ - @ instruction: 0xf7f9fa1f │ │ │ │ - svclt 0x0000edae │ │ │ │ - @ instruction: 0x000522ba │ │ │ │ - andeq r2, r5, r0, lsr #5 │ │ │ │ - muleq r5, lr, r2 │ │ │ │ - andeq r2, r5, r4, ror #4 │ │ │ │ - andeq r0, r4, sl, asr fp │ │ │ │ - andeq r0, r4, r8, asr #22 │ │ │ │ + @ instruction: 0xf7f9fe6f │ │ │ │ + svclt 0x0000ee1e │ │ │ │ + andeq r2, r5, r2, asr r3 │ │ │ │ + andeq r2, r5, r8, lsr r3 │ │ │ │ + andeq r2, r5, r6, lsr r3 │ │ │ │ + strdeq r2, [r5], -ip │ │ │ │ + strdeq r0, [r4], -sl │ │ │ │ + strdeq r0, [r4], -r0 @ │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb60610 <__bss_end__@@Base+0xfeab99d8> │ │ │ │ + bl feb604e0 <__bss_end__@@Base+0xfeab9940> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stmdavs r2, {r4, r5, r6, r7, r8, r9, sl, fp} │ │ │ │ - blle 7d3c1c <__bss_end__@@Base+0x72cfe4> │ │ │ │ + blle 7d3aec <__bss_end__@@Base+0x72cf4c> │ │ │ │ ldmdbmi r4, {r0, r2, r3, r9, sl, lr} │ │ │ │ ldrbtmi r4, [r9], #-1540 @ 0xfffff9fc │ │ │ │ orrlt r6, r3, fp, asr #16 │ │ │ │ subvs r6, r8, r8, asr r8 │ │ │ │ stmib r3, {r8, sp}^ │ │ │ │ @ instruction: 0xb12a5100 │ │ │ │ andcc r6, r1, #10551296 @ 0xa10000 │ │ │ │ adcvs r6, r3, fp, asr #32 │ │ │ │ ldclt 0, cr6, [r8, #-136]! @ 0xffffff78 │ │ │ │ rsbvs r3, r3, r1, lsl #4 │ │ │ │ eorvs r6, r2, r3, lsr #1 │ │ │ │ stmdami sl, {r3, r4, r5, r8, sl, fp, ip, sp, pc} │ │ │ │ cmncs sl, r8, lsl #4 │ │ │ │ @ instruction: 0xf00a4478 │ │ │ │ - stmdavs r2!, {r0, r1, r3, r6, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmdavs r2!, {r0, r1, r2, r3, r6, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ strb r4, [r7, r3, lsl #12]! │ │ │ │ movwcs r4, #2566 @ 0xa06 │ │ │ │ cmncs r7, r6, lsl #16 │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - @ instruction: 0xf9def009 │ │ │ │ - stcl 7, cr15, [ip, #-996]! @ 0xfffffc1c │ │ │ │ - andeq r2, r5, lr, lsl #4 │ │ │ │ - ldrdeq r0, [r4], -ip │ │ │ │ - ldrdeq r0, [r4], -r8 │ │ │ │ - andeq r0, r4, r6, asr #21 │ │ │ │ + cdp2 0, 2, cr15, cr14, cr9, {0} │ │ │ │ + ldcl 7, cr15, [ip, #996] @ 0x3e4 │ │ │ │ + andeq r2, r5, r6, lsr #5 │ │ │ │ + andeq r0, r4, r4, lsl #23 │ │ │ │ + andeq r0, r4, r8, ror fp │ │ │ │ + andeq r0, r4, lr, ror #22 │ │ │ │ strlt fp, [r8, #-392] @ 0xfffffe78 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00f8f8cc │ │ │ │ - blcs 234a0 │ │ │ │ + blcs 23370 │ │ │ │ svclt 0x0013db09 │ │ │ │ sbcvs r6, r3, r3, asr #16 │ │ │ │ sbcvs r2, r3, r0 │ │ │ │ ldmdavs r8, {r3, r4, r8, r9, sl, fp, ip, sp, pc} │ │ │ │ andcs fp, r0, r8, lsl #26 │ │ │ │ - bmi 15b26c <__bss_end__@@Base+0xb4634> │ │ │ │ + bmi 15b13c <__bss_end__@@Base+0xb459c> │ │ │ │ stmdami r5, {r8, r9, sp} │ │ │ │ ldrbtmi r2, [sl], #-404 @ 0xfffffe6c │ │ │ │ @ instruction: 0xf0094478 │ │ │ │ - @ instruction: 0xf7f9f9b7 │ │ │ │ - svclt 0x0000ed46 │ │ │ │ - andeq r0, r4, sl, lsl #21 │ │ │ │ - andeq r0, r4, r8, ror sl │ │ │ │ + @ instruction: 0xf7f9fe07 │ │ │ │ + svclt 0x0000edb6 │ │ │ │ + andeq r0, r4, sl, lsr #22 │ │ │ │ + andeq r0, r4, r0, lsr #22 │ │ │ │ strlt fp, [r8, #-400] @ 0xfffffe70 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00f8f8cc │ │ │ │ - blcs 234e8 │ │ │ │ + blcs 233b8 │ │ │ │ stmiavs r3, {r1, r3, r8, r9, fp, ip, lr, pc}^ │ │ │ │ ldmdavs fp, {r0, r1, r5, r8, ip, sp, pc}^ │ │ │ │ smlabtlt fp, r3, r0, r6 │ │ │ │ stclt 8, cr6, [r8, #-96] @ 0xffffffa0 │ │ │ │ stclt 0, cr2, [r8, #-0] │ │ │ │ ldrbmi r2, [r0, -r0]! │ │ │ │ movwcs r4, #2564 @ 0xa04 │ │ │ │ @ instruction: 0x21a64804 │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - @ instruction: 0xf992f009 │ │ │ │ - stc 7, cr15, [r0, #-996]! @ 0xfffffc1c │ │ │ │ - andeq r0, r4, r0, asr #20 │ │ │ │ - andeq r0, r4, lr, lsr #20 │ │ │ │ + stc2l 0, cr15, [r2, #36]! @ 0x24 │ │ │ │ + ldc 7, cr15, [r0, #996] @ 0x3e4 │ │ │ │ + andeq r0, r4, r0, ror #21 │ │ │ │ + ldrdeq r0, [r4], -r6 │ │ │ │ vst3.8 {d27,d29,d31}, [pc], r8 │ │ │ │ - bl feb60718 <__bss_end__@@Base+0xfeab9ae0> │ │ │ │ + bl feb605e8 <__bss_end__@@Base+0xfeab9a48> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stmdavs r3, {r3, r4, r5, r6, r7, r8, r9, sl, fp} │ │ │ │ - blle 94124 <__bss_start@@Base+0x39084> │ │ │ │ + blle 93ff4 <__bss_start@@Base+0x38fec> │ │ │ │ andsvs r6, r9, r3, asr #17 │ │ │ │ - bmi 17894c <__bss_end__@@Base+0xd1d14> │ │ │ │ + bmi 17881c <__bss_end__@@Base+0xd1c7c> │ │ │ │ stmdami r5, {r8, r9, sp} │ │ │ │ ldrbtmi r2, [sl], #-439 @ 0xfffffe49 │ │ │ │ @ instruction: 0xf0094478 │ │ │ │ - @ instruction: 0xf7f9f977 │ │ │ │ - svclt 0x0000ed06 │ │ │ │ - andeq r0, r4, sl, lsl #20 │ │ │ │ - strdeq r0, [r4], -r8 │ │ │ │ + @ instruction: 0xf7f9fdc7 │ │ │ │ + svclt 0x0000ed76 │ │ │ │ + andeq r0, r4, sl, lsr #21 │ │ │ │ + andeq r0, r4, r0, lsr #21 │ │ │ │ stmdavs r0, {r4, r8, ip, sp, pc} │ │ │ │ - blle 13550 │ │ │ │ + blle 13420 │ │ │ │ strlt r4, [r8, #-1904] @ 0xfffff890 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00f8f8cc │ │ │ │ movwcs r4, #2564 @ 0xa04 │ │ │ │ biccs r4, r3, r4, lsl #16 │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - @ instruction: 0xf95cf009 │ │ │ │ - stcl 7, cr15, [sl], #996 @ 0x3e4 │ │ │ │ - ldrdeq r0, [r4], -r4 │ │ │ │ - andeq r0, r4, r2, asr #19 │ │ │ │ + stc2 0, cr15, [ip, #36]! @ 0x24 │ │ │ │ + ldcl 7, cr15, [sl, #-996] @ 0xfffffc1c │ │ │ │ + andeq r0, r4, r4, ror sl │ │ │ │ + andeq r0, r4, sl, ror #20 │ │ │ │ ldrbtmi r4, [fp], #-2818 @ 0xfffff4fe │ │ │ │ eoreq pc, r0, r3, asr r8 @ │ │ │ │ svclt 0x00004770 │ │ │ │ - muleq r4, sl, r8 │ │ │ │ - mvnsmi lr, sp, lsr #18 │ │ │ │ + andeq lr, r4, r2, lsl #19 │ │ │ │ + ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00d0f8cc │ │ │ │ - strmi fp, [r7], -r6, lsl #1 │ │ │ │ - @ instruction: 0xf9b1b369 │ │ │ │ - strmi r3, [sp], -r2 │ │ │ │ - bmi 6b62d8 <__bss_end__@@Base+0x60f6a0> │ │ │ │ - ldrbtmi r2, [sl], #-257 @ 0xfffffeff │ │ │ │ - svc 0x0018f7f9 │ │ │ │ - @ instruction: 0x3002f9b5 │ │ │ │ - vldrle d2, [sp, #-0] │ │ │ │ - ldrsbhi pc, [r8], #-143 @ 0xffffff71 @ │ │ │ │ - strtmi r2, [r6], -r0, lsl #8 │ │ │ │ - bvs ada9a8 <__bss_end__@@Base+0xa33d70> │ │ │ │ - tstcs r1, r2, asr #12 │ │ │ │ - strtmi r4, [r3], #-1592 @ 0xfffff9c8 │ │ │ │ - ldrcc r3, [r8], #-1537 @ 0xfffff9ff │ │ │ │ - blvc 144c24 <__bss_end__@@Base+0x9dfec> │ │ │ │ - blvc 144c10 <__bss_end__@@Base+0x9dfd8> │ │ │ │ - blvc c4c2c <__bss_end__@@Base+0x1dff4> │ │ │ │ - blvc c4c18 <__bss_end__@@Base+0x1dfe0> │ │ │ │ - blvc 44c34 │ │ │ │ - blvc 44c20 │ │ │ │ - mrc 7, 7, APSR_nzcv, cr10, cr9, {7} │ │ │ │ + strmi fp, [r7], -r4, lsl #1 │ │ │ │ + @ instruction: 0xf9b1b359 │ │ │ │ + strmi r2, [sp], -r2 │ │ │ │ + ldmdbmi r9, {r1, r3, r4, r5, r8, r9, ip, sp, pc} │ │ │ │ + @ instruction: 0xf7f94479 │ │ │ │ + @ instruction: 0xf9b5ef68 │ │ │ │ + blcs 15490 │ │ │ │ + @ instruction: 0xf8dfdd1c │ │ │ │ + strcs sl, [r0], #-88 @ 0xffffffa8 │ │ │ │ + ldrbtmi r4, [sl], #1574 @ 0x626 │ │ │ │ + ldrbmi r6, [r1], -fp, lsr #20 │ │ │ │ + @ instruction: 0x36014638 │ │ │ │ + ldrcc r4, [r8], #-1059 @ 0xfffffbdd │ │ │ │ + blvc 144af0 <__bss_end__@@Base+0x9df50> │ │ │ │ + stmdbhi r0, {r0, r1, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ + blvc c4ae0 <__bss_end__@@Base+0x1df40> │ │ │ │ + blvc c4afc <__bss_end__@@Base+0x1df5c> │ │ │ │ + strbmi r4, [fp], -r2, asr #12 │ │ │ │ + blvc 44aec │ │ │ │ + svc 0x004af7f9 │ │ │ │ @ instruction: 0x3002f9b5 │ │ │ │ - stclle 2, cr4, [r6], #716 @ 0x2cc │ │ │ │ - pop {r1, r2, ip, sp, pc} │ │ │ │ - blmi 1e9dc0 <__bss_end__@@Base+0x143188> │ │ │ │ - bmi 1d1a08 <__bss_end__@@Base+0x12add0> │ │ │ │ - ldrbtmi r4, [fp], #-1592 @ 0xfffff9c8 │ │ │ │ - andlt r4, r6, sl, ror r4 │ │ │ │ - ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - mcrlt 7, 7, pc, cr6, cr9, {7} @ │ │ │ │ - andeq r0, r4, r6, asr #19 │ │ │ │ - andeq r0, r4, r0, asr #19 │ │ │ │ - andeq r0, r4, r6, asr r9 │ │ │ │ - andeq r1, r4, ip, asr pc │ │ │ │ + stclle 2, cr4, [r7], #716 @ 0x2cc │ │ │ │ + pop {r2, ip, sp, pc} │ │ │ │ + bmi 1eb48c <__bss_end__@@Base+0x1448ec> │ │ │ │ + stmdbmi r7, {r3, r4, r5, r9, sl, lr} │ │ │ │ + ldrbtmi r4, [r9], #-1146 @ 0xfffffb86 │ │ │ │ + pop {r2, ip, sp, pc} │ │ │ │ + @ instruction: 0xf7f947f0 │ │ │ │ + svclt 0x0000bf37 │ │ │ │ + andeq r0, r4, r8, ror #20 │ │ │ │ + andeq r0, r4, r2, ror #20 │ │ │ │ + strdeq r0, [r4], -ip │ │ │ │ + andeq r2, r4, lr, asr #4 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi c4ae4 <__bss_end__@@Base+0x1deac> │ │ │ │ + blhi c49b0 <__bss_end__@@Base+0x1de10> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00a8f8cc │ │ │ │ stmdbmi r3, {r1, r2, r3, r9, sl, lr}^ │ │ │ │ - bmi 10dae90 <__bss_end__@@Base+0x1034258> │ │ │ │ + bmi 10dad5c <__bss_end__@@Base+0x10341bc> │ │ │ │ svcmi 0x00434479 │ │ │ │ strmi fp, [r0], lr, lsl #1 │ │ │ │ movwcs r4, #1151 @ 0x47f │ │ │ │ ldrtmi r5, [r8], -sl, lsl #17 │ │ │ │ tstpne r1, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ andls r6, sp, #1179648 @ 0x120000 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ @ instruction: 0xf00a2238 │ │ │ │ - strtmi pc, [r4], r5, asr #19 │ │ │ │ + strtmi pc, [r4], fp, asr #21 │ │ │ │ strmi r4, [r4], -r5, lsl #12 │ │ │ │ cdpeq 0, 1, cr15, cr8, cr15, {2} │ │ │ │ @ instruction: 0x000fe8bc │ │ │ │ ldm ip!, {r0, r1, r2, r3, sl, lr, pc} │ │ │ │ - strgt r0, [pc], #-15 @ 9678 │ │ │ │ + strgt r0, [pc], #-15 @ 9544 │ │ │ │ @ instruction: 0x000fe8bc │ │ │ │ - blx 3ba6be <__bss_end__@@Base+0x313a86> │ │ │ │ + blx 3ba58a <__bss_end__@@Base+0x3139ea> │ │ │ │ movwcs pc, #520 @ 0x208 @ │ │ │ │ muleq r3, ip, r8 │ │ │ │ andeq lr, r3, r4, lsl #17 │ │ │ │ tstpne r5, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf8a54638 │ │ │ │ @ instruction: 0xf00a8002 │ │ │ │ - @ instruction: 0xf9b5f9a9 │ │ │ │ + @ instruction: 0xf9b5faaf │ │ │ │ ldrtmi r2, [r1], -r2 │ │ │ │ - bl a1f44 <__bss_start@@Base+0x46ea4> │ │ │ │ + bl a1e10 <__bss_start@@Base+0x46e08> │ │ │ │ sbcseq r0, r2, r2, asr #4 │ │ │ │ - stcl 7, cr15, [r0, #996] @ 0x3e4 │ │ │ │ + mrc 7, 1, APSR_nzcv, cr6, cr9, {7} │ │ │ │ @ instruction: 0x3000f9b5 │ │ │ │ ldrtle r0, [r7], #-1882 @ 0xfffff8a6 │ │ │ │ strle r0, [r1], #-2011 @ 0xfffff825 │ │ │ │ orrslt r6, fp, #700416 @ 0xab000 │ │ │ │ - blhi 1c4d18 <__bss_end__@@Base+0x11e0e0> │ │ │ │ + blhi 1c4be4 <__bss_end__@@Base+0x11e044> │ │ │ │ andeq pc, r8, #1073741825 @ 0x40000001 │ │ │ │ - blvc 344d20 <__bss_end__@@Base+0x29e0e8> │ │ │ │ + blvc 344bec <__bss_end__@@Base+0x29e04c> │ │ │ │ @ instruction: 0xed96a906 │ │ │ │ strbtmi r3, [r8], -r0, lsl #22 │ │ │ │ - blne 244d2c <__bss_end__@@Base+0x19e0f4> │ │ │ │ - blcs 2c4d30 <__bss_end__@@Base+0x21e0f8> │ │ │ │ - blcc 1244fa8 <__bss_end__@@Base+0x119e370> │ │ │ │ - blmi c4d38 <__bss_end__@@Base+0x1e100> │ │ │ │ - blhi 1244fc0 <__bss_end__@@Base+0x119e388> │ │ │ │ - blpl 144d40 <__bss_end__@@Base+0x9e108> │ │ │ │ - blvs 3c4d44 <__bss_end__@@Base+0x31e10c> │ │ │ │ - blvc 444d48 <__bss_end__@@Base+0x39e110> │ │ │ │ - blmi 1084fc4 <__bss_end__@@Base+0xfde38c> │ │ │ │ - blpl 10c4fcc <__bss_end__@@Base+0x101e394> │ │ │ │ - blcc 44d30 │ │ │ │ - blvs 1084fd8 <__bss_end__@@Base+0xfde3a0> │ │ │ │ - blhi 1c4d38 <__bss_end__@@Base+0x11e100> │ │ │ │ - blvc 10c4fe4 <__bss_end__@@Base+0x101e3ac> │ │ │ │ - blmi c4d40 <__bss_end__@@Base+0x1e108> │ │ │ │ - blpl 144d44 <__bss_end__@@Base+0x9e10c> │ │ │ │ - blvs 244d48 <__bss_end__@@Base+0x19e110> │ │ │ │ - blvc 2c4d4c <__bss_end__@@Base+0x21e114> │ │ │ │ - blx 1bc5720 <__bss_end__@@Base+0x1b1eae8> │ │ │ │ + blne 244bf8 <__bss_end__@@Base+0x19e058> │ │ │ │ + blcs 2c4bfc <__bss_end__@@Base+0x21e05c> │ │ │ │ + blcc 1244e74 <__bss_end__@@Base+0x119e2d4> │ │ │ │ + blmi c4c04 <__bss_end__@@Base+0x1e064> │ │ │ │ + blhi 1244e8c <__bss_end__@@Base+0x119e2ec> │ │ │ │ + blpl 144c0c <__bss_end__@@Base+0x9e06c> │ │ │ │ + blvs 3c4c10 <__bss_end__@@Base+0x31e070> │ │ │ │ + blvc 444c14 <__bss_end__@@Base+0x39e074> │ │ │ │ + blmi 1084e90 <__bss_end__@@Base+0xfde2f0> │ │ │ │ + blpl 10c4e98 <__bss_end__@@Base+0x101e2f8> │ │ │ │ + blcc 44bfc │ │ │ │ + blvs 1084ea4 <__bss_end__@@Base+0xfde304> │ │ │ │ + blhi 1c4c04 <__bss_end__@@Base+0x11e064> │ │ │ │ + blvc 10c4eb0 <__bss_end__@@Base+0x101e310> │ │ │ │ + blmi c4c0c <__bss_end__@@Base+0x1e06c> │ │ │ │ + blpl 144c10 <__bss_end__@@Base+0x9e070> │ │ │ │ + blvs 244c14 <__bss_end__@@Base+0x19e074> │ │ │ │ + blvc 2c4c18 <__bss_end__@@Base+0x21e078> │ │ │ │ + blx ffc855ec <__bss_end__@@Base+0xffbdea4c> │ │ │ │ @ instruction: 0xf043882b │ │ │ │ eorhi r0, fp, r4, lsl #6 │ │ │ │ - blmi 25bf54 <__bss_end__@@Base+0x1b531c> │ │ │ │ + blmi 25be20 <__bss_end__@@Base+0x1b5280> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 363798 <__bss_end__@@Base+0x2bcb60> │ │ │ │ + blls 363664 <__bss_end__@@Base+0x2bcac4> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, SP_abt │ │ │ │ andlt r4, lr, r8, lsr #12 │ │ │ │ - blhi c4a34 <__bss_end__@@Base+0x1ddfc> │ │ │ │ + blhi c4900 <__bss_end__@@Base+0x1dd60> │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ - mrc 7, 1, APSR_nzcv, cr10, cr9, {7} │ │ │ │ - andeq lr, r4, r0, asr #19 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r0, r4, r4, ror #17 │ │ │ │ - ldrdeq lr, [r4], -r8 │ │ │ │ + mrc 7, 5, APSR_nzcv, cr0, cr9, {7} │ │ │ │ + strdeq lr, [r4], -r4 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + muleq r4, r0, r9 │ │ │ │ + andeq lr, r4, ip, lsl #20 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb60960 <__bss_end__@@Base+0xfeab9d28> │ │ │ │ + bl feb6082c <__bss_end__@@Base+0xfeab9c8c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xb0900fb8 │ │ │ │ movwcs r4, #1556 @ 0x614 │ │ │ │ - blvc 484dec <__bss_end__@@Base+0x3de1b4> │ │ │ │ + blvc 444cb8 <__bss_end__@@Base+0x39e118> │ │ │ │ stmib sp, {r1, r3, r5, r6, r9, sl, lr}^ │ │ │ │ - ldcmi 3, cr4, [r1], {9} │ │ │ │ + ldcmi 3, cr4, [r0], {9} │ │ │ │ andcc pc, r0, sp, lsr #17 │ │ │ │ - ldrbtmi r4, [ip], #-2832 @ 0xfffff4f0 │ │ │ │ - blvc 344db8 <__bss_end__@@Base+0x29e180> │ │ │ │ + ldrbtmi r4, [ip], #-2831 @ 0xfffff4f1 │ │ │ │ + blvc 344c84 <__bss_end__@@Base+0x29e0e4> │ │ │ │ ldmdavs fp, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f930f │ │ │ │ @ instruction: 0xf7ff0300 │ │ │ │ - bmi 3494b8 <__bss_end__@@Base+0x2a2880> │ │ │ │ - ldrbtmi r4, [sl], #-2826 @ 0xfffff4f6 │ │ │ │ + bmi 309384 <__bss_end__@@Base+0x2627e4> │ │ │ │ + ldrbtmi r4, [sl], #-2825 @ 0xfffff4f7 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, pc, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andslt sp, r0, r1, lsl #2 │ │ │ │ @ instruction: 0xf7f9bd10 │ │ │ │ - svclt 0x0000ee08 │ │ │ │ - andhi pc, r0, pc, lsr #7 │ │ │ │ + svclt 0x0000ee7e │ │ │ │ ... │ │ │ │ - andeq lr, r4, r2, lsl #17 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq lr, r4, sl, ror #16 │ │ │ │ + @ instruction: 0x0004e9b6 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + muleq r4, lr, r9 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stceq 0, cr15, [r0], {79} @ 0x4f │ │ │ │ cdpmi 4, 4, cr15, cr0, cr15, {2} │ │ │ │ - blhi 144c8c <__bss_end__@@Base+0x9e054> │ │ │ │ + blhi 144b54 <__bss_end__@@Base+0x9dfb4> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ vmlaeq.f64 d14, d30, d28 │ │ │ │ stcpl 5, cr15, [r0], {172} @ 0xac │ │ │ │ andeq pc, r0, ip, asr #17 │ │ │ │ ldrshle r4, [r9, #84]! @ 0x54 │ │ │ │ mcrreq 8, 4, pc, r8, cr14 @ │ │ │ │ - blmi 179c168 <__bss_end__@@Base+0x16f5530> │ │ │ │ + blmi 179c030 <__bss_end__@@Base+0x16f5490> │ │ │ │ ldrbtmi r4, [sl], #-1542 @ 0xfffff9fa │ │ │ │ stclmi 5, cr15, [r0, #-692] @ 0xfffffd4c │ │ │ │ @ instruction: 0xf50db085 │ │ │ │ @ instruction: 0xf9b64040 │ │ │ │ ldmpl r3, {r1, lr}^ │ │ │ │ stccs 0, cr3, [r0], {12} │ │ │ │ andvs r6, r3, fp, lsl r8 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ tstls r0, r0, lsr sl │ │ │ │ addshi pc, r0, r0, asr #6 │ │ │ │ - blx 113482 <__bss_end__@@Base+0x6c84a> │ │ │ │ + blx 11334a <__bss_end__@@Base+0x6c7aa> │ │ │ │ stccc 0, cr0, [r1], {7} │ │ │ │ @ instruction: 0xf0013818 │ │ │ │ - @ instruction: 0xf9b6f9d3 │ │ │ │ + @ instruction: 0xf9b6fa44 │ │ │ │ cdp 0, 11, cr3, cr0, cr2, {0} │ │ │ │ - blcs 2c534 │ │ │ │ + blcs 2c3fc │ │ │ │ addhi pc, r1, r0, asr #6 │ │ │ │ @ instruction: 0xf10d2200 │ │ │ │ @ instruction: 0x46900a10 │ │ │ │ mrc 6, 5, r4, cr7, cr5, {0} │ │ │ │ andls r9, r1, #0, 22 │ │ │ │ cdp 0, 11, cr14, cr0, cr2, {0} │ │ │ │ ldrmi r8, [sp], -r0, asr #22 │ │ │ │ - blhi ff045328 <__bss_end__@@Base+0xfef9e6f0> │ │ │ │ + blhi ff0451f0 <__bss_end__@@Base+0xfef9e650> │ │ │ │ ldrdlt pc, [r0], -r6 @ │ │ │ │ - blx 445420 <__bss_end__@@Base+0x39e7e8> │ │ │ │ - blx 200c9e <__bss_end__@@Base+0x15a066> │ │ │ │ - blx 1f9076 <__bss_end__@@Base+0x15243e> │ │ │ │ + blx 4452e8 <__bss_end__@@Base+0x39e748> │ │ │ │ + blx 200b66 <__bss_end__@@Base+0x159fc6> │ │ │ │ + blx 1f8f3e <__bss_end__@@Base+0x15239e> │ │ │ │ @ instruction: 0xf108ac08 │ │ │ │ @ instruction: 0xf1ac0801 │ │ │ │ ldm lr!, {r3, sl, fp} │ │ │ │ stmia ip!, {r0, r1, r2, r3} │ │ │ │ ldm lr, {r0, r1, r2, r3} │ │ │ │ stm ip, {r0, r1} │ │ │ │ - blx 1c988e <__bss_end__@@Base+0x122c56> │ │ │ │ + blx 1c9756 <__bss_end__@@Base+0x122bb6> │ │ │ │ stmdbls r0, {r0, r2, r8, fp, ip, sp, lr, pc} │ │ │ │ andeq lr, r9, fp, lsl #22 │ │ │ │ - @ instruction: 0xf9a2f001 │ │ │ │ - blvc 245110 <__bss_end__@@Base+0x19e4d8> │ │ │ │ - blvc ff045368 <__bss_end__@@Base+0xfef9e730> │ │ │ │ - blx 44545c <__bss_end__@@Base+0x39e824> │ │ │ │ + blx 505758 <__bss_end__@@Base+0x45ebb8> │ │ │ │ + blvc 244fd8 <__bss_end__@@Base+0x19e438> │ │ │ │ + blvc ff045230 <__bss_end__@@Base+0xfef9e690> │ │ │ │ + blx 445324 <__bss_end__@@Base+0x39e784> │ │ │ │ cdp 5, 3, cr13, cr8, cr14, {1} │ │ │ │ - bvs ca85a0 <__bss_end__@@Base+0xc01968> │ │ │ │ + bvs ca8468 <__bss_end__@@Base+0xc018c8> │ │ │ │ tstpge r8, r7, lsl #22 @ p-variant is OBSOLETE │ │ │ │ stmdaeq r1, {r3, r8, ip, sp, lr, pc} │ │ │ │ movweq lr, #39682 @ 0x9b02 │ │ │ │ - blmi 2052d0 <__bss_end__@@Base+0x15e698> │ │ │ │ + blmi 205198 <__bss_end__@@Base+0x15e5f8> │ │ │ │ andcs pc, r4, #7168 @ 0x1c00 │ │ │ │ - blne 44f04 │ │ │ │ - blcs c4f08 <__bss_end__@@Base+0x1e2d0> │ │ │ │ - blcc 144f0c <__bss_end__@@Base+0x9e2d4> │ │ │ │ + blne 44dcc │ │ │ │ + blcs c4dd0 <__bss_end__@@Base+0x1e230> │ │ │ │ + blcc 144dd4 <__bss_end__@@Base+0x9e234> │ │ │ │ ldc 3, cr2, [r2, #4] │ │ │ │ vldr d5, [r2] │ │ │ │ vldr d6, [r2, #8] │ │ │ │ movwls r8, #6916 @ 0x1b04 │ │ │ │ - blvc 11451b8 <__bss_end__@@Base+0x109e580> │ │ │ │ - blpl 185174 <__bss_end__@@Base+0xde53c> │ │ │ │ - blvs 1c5178 <__bss_end__@@Base+0x11e540> │ │ │ │ - blvc 24517c <__bss_end__@@Base+0x19e544> │ │ │ │ - blpl 850f4 <__bss_start@@Base+0x2a054> │ │ │ │ - blvs c50f8 <__bss_end__@@Base+0x1e4c0> │ │ │ │ - blvc 1050fc <__bss_end__@@Base+0x5e4c4> │ │ │ │ - blpl c4cf4 <__bss_end__@@Base+0x1e0bc> │ │ │ │ - blvs 44ef8 │ │ │ │ - blvc c4efc <__bss_end__@@Base+0x1e2c4> │ │ │ │ + blvc 1145080 <__bss_end__@@Base+0x109e4e0> │ │ │ │ + blpl 18503c <__bss_end__@@Base+0xde49c> │ │ │ │ + blvs 1c5040 <__bss_end__@@Base+0x11e4a0> │ │ │ │ + blvc 245044 <__bss_end__@@Base+0x19e4a4> │ │ │ │ + blpl 84fbc <__bss_start@@Base+0x29fb4> │ │ │ │ + blvs c4fc0 <__bss_end__@@Base+0x1e420> │ │ │ │ + blvc 104fc4 <__bss_end__@@Base+0x5e424> │ │ │ │ + blpl c4bbc <__bss_end__@@Base+0x1e01c> │ │ │ │ + blvs 44dc0 │ │ │ │ + blvc c4dc4 <__bss_end__@@Base+0x1e224> │ │ │ │ @ instruction: 0x2002f9b6 │ │ │ │ strtmi r1, [ip], -fp, ror #24 │ │ │ │ stcle 2, cr4, [r2], #616 @ 0x268 │ │ │ │ @ instruction: 0xf1b89a01 │ │ │ │ andsle r0, r6, r0, lsl #30 │ │ │ │ stmiblt r2!, {r2, r4, r5, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf50d4a17 │ │ │ │ - blmi 559e18 <__bss_end__@@Base+0x4b31e0> │ │ │ │ + blmi 559ce0 <__bss_end__@@Base+0x4b3140> │ │ │ │ ldrbtmi r3, [sl], #-268 @ 0xfffffef4 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r6, sl, fp, lsl #16 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ @ instruction: 0x4620d11c │ │ │ │ stclmi 5, cr15, [r0, #-52] @ 0xffffffcc │ │ │ │ ldc 0, cr11, [sp], #20 │ │ │ │ pop {r2, r8, r9, fp, pc} │ │ │ │ - bvs c2d8fc <__bss_end__@@Base+0xb86cc4> │ │ │ │ - @ instruction: 0xf906f00a │ │ │ │ + bvs c2d7c4 <__bss_end__@@Base+0xb86c24> │ │ │ │ + blx 3c5830 <__bss_end__@@Base+0x31ec90> │ │ │ │ strcs r4, [r0], #-1584 @ 0xfffff9d0 │ │ │ │ - @ instruction: 0xf902f00a │ │ │ │ + blx 2c5838 <__bss_end__@@Base+0x21ec98> │ │ │ │ ldrtmi lr, [r2], -r2, ror #15 │ │ │ │ strbmi sl, [r0], -r2, lsl #18 │ │ │ │ - mcr2 7, 3, pc, cr8, cr15, {7} @ │ │ │ │ - bvs c1b168 <__bss_end__@@Base+0xb74530> │ │ │ │ - @ instruction: 0xf8f8f00a │ │ │ │ + mcr2 7, 3, pc, cr10, cr15, {7} @ │ │ │ │ + bvs c1b030 <__bss_end__@@Base+0xb74490> │ │ │ │ + blx 4584c │ │ │ │ @ instruction: 0xf00a4630 │ │ │ │ - @ instruction: 0xe7d5f8f5 │ │ │ │ - stc 7, cr15, [sl, #-996]! @ 0xfffffc1c │ │ │ │ - andeq lr, r4, sl, lsl #16 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq lr, r4, r6, ror #13 │ │ │ │ + @ instruction: 0xe7d5f9fd │ │ │ │ + stc 7, cr15, [r2, #996]! @ 0x3e4 │ │ │ │ + andeq lr, r4, r2, asr #18 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq lr, r4, lr, lsl r8 │ │ │ │ strmi r6, [r2], -r1, lsl #20 │ │ │ │ @ instruction: 0x0002f9b0 │ │ │ │ - mrclt 7, 2, APSR_nzcv, cr2, cr15, {7} │ │ │ │ + mrclt 7, 2, APSR_nzcv, cr4, cr15, {7} │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00b8f8cc │ │ │ │ addlt r4, r9, pc, lsl sl │ │ │ │ @ instruction: 0x46064b1f │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ movwls r6, #30747 @ 0x781b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ @ instruction: 0x3002f9b0 │ │ │ │ vstmdble r0!, {d2-d1} │ │ │ │ ldrdge pc, [r0], -r0 @ │ │ │ │ strcs r4, [r0, #-1672] @ 0xfffff978 │ │ │ │ @ instruction: 0xf04f466f │ │ │ │ - blx 24be1e <__bss_end__@@Base+0x1a51e6> │ │ │ │ + blx 24bce6 <__bss_end__@@Base+0x1a5146> │ │ │ │ ldrtmi pc, [sl], -r5, lsl #8 @ │ │ │ │ strcc r4, [r1, #-1601] @ 0xfffff9bf │ │ │ │ andeq lr, r4, sl, lsl #22 │ │ │ │ - mcrr2 0, 0, pc, lr, cr1 @ │ │ │ │ + stc2 0, cr15, [r2, #4] │ │ │ │ @ instruction: 0xf8d646be │ │ │ │ @ instruction: 0xf9b6a020 │ │ │ │ ldm lr!, {r1, ip, sp, pc} │ │ │ │ - bl 289a18 <__bss_end__@@Base+0x1e2de0> │ │ │ │ + bl 2898e0 <__bss_end__@@Base+0x1e2d40> │ │ │ │ strmi r0, [fp, #3076]! @ 0xc04 │ │ │ │ andeq lr, pc, ip, lsr #17 │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ - bmi 2c0d84 <__bss_end__@@Base+0x21a14c> │ │ │ │ + bmi 2c0c4c <__bss_end__@@Base+0x21a0ac> │ │ │ │ ldrbtmi r4, [sl], #-2824 @ 0xfffff4f8 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r7, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ ldrtmi sp, [r0], -r3, lsl #2 │ │ │ │ pop {r0, r3, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f98ff0 │ │ │ │ - svclt 0x0000ecd8 │ │ │ │ - andeq lr, r4, r8, ror #12 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq lr, r4, lr, lsl #12 │ │ │ │ + svclt 0x0000ed50 │ │ │ │ + andeq lr, r4, r0, lsr #15 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq lr, r4, r6, asr #14 │ │ │ │ @ instruction: 0x3002f9b1 │ │ │ │ vldrle d2, [sl, #-0] │ │ │ │ ldrblt fp, [r0, #-448]! @ 0xfffffe40 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00f0f8cc │ │ │ │ strmi r2, [sp], -r0, lsl #8 │ │ │ │ and r2, r0, r8, lsl r6 │ │ │ │ - bvs a75f80 <__bss_end__@@Base+0x9cf348> │ │ │ │ + bvs a75e48 <__bss_end__@@Base+0x9cf2a8> │ │ │ │ tstpne r4, r6, lsl #22 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7ff3401 │ │ │ │ @ instruction: 0xf9b5febf │ │ │ │ adcmi r3, r3, #2 │ │ │ │ ldcllt 12, cr13, [r0, #-976]! @ 0xfffffc30 │ │ │ │ ldcllt 0, cr2, [r0, #-0] │ │ │ │ ldrbmi r2, [r0, -r0]! │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb60c64 <__bss_end__@@Base+0xfeaba02c> │ │ │ │ + bl feb60b2c <__bss_end__@@Base+0xfeab9f8c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stmdahi r3, {r3, r5, r6, r7, r8, r9, sl, fp} │ │ │ │ strmi r4, [pc], -r4, lsl #12 │ │ │ │ - ldrle r0, [pc], #-1882 @ 9a74 │ │ │ │ + ldrle r0, [pc], #-1882 @ 993c │ │ │ │ @ instruction: 0x3002f9b7 │ │ │ │ - vstrle d2, [pc, #-0] @ 9a7c │ │ │ │ + vstrle d2, [pc, #-0] @ 9944 │ │ │ │ ldrcs r2, [r8], -r0, lsl #10 │ │ │ │ @ instruction: 0xb1ace000 │ │ │ │ @ instruction: 0x46206a39 │ │ │ │ tstpne r5, r6, lsl #22 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7ff3501 │ │ │ │ @ instruction: 0xf9b7fe9b │ │ │ │ strmi r3, [r4], -r2 │ │ │ │ ldclle 2, cr4, [r2], #684 @ 0x2ac │ │ │ │ ldcllt 6, cr4, [r8, #128]! @ 0x80 │ │ │ │ strble r0, [r7, #2011]! @ 0x7db │ │ │ │ @ instruction: 0xf00a6a20 │ │ │ │ - @ instruction: 0x4620f851 │ │ │ │ - @ instruction: 0xf84ef00a │ │ │ │ + @ instruction: 0x4620f959 │ │ │ │ + @ instruction: 0xf956f00a │ │ │ │ ldcllt 0, cr2, [r8] │ │ │ │ @ instruction: 0xf1046a00 │ │ │ │ @ instruction: 0xf0010108 │ │ │ │ - cdp 8, 11, cr15, cr5, cr9, {4} │ │ │ │ + mrc 8, 5, APSR_nzcv, cr5, cr10, {7} │ │ │ │ vsqrt.f64 d16, d0 │ │ │ │ - blle 388308 <__bss_end__@@Base+0x2e16d0> │ │ │ │ + blle 3881d0 <__bss_end__@@Base+0x2e1630> │ │ │ │ @ instruction: 0xf9b46aa2 │ │ │ │ - bcs 15ad0 │ │ │ │ + bcs 15998 │ │ │ │ @ instruction: 0xf9b7d0e6 │ │ │ │ @ instruction: 0xf0432002 │ │ │ │ eorhi r0, r3, r2, lsl #6 │ │ │ │ vstmiale sp, {s5-s4} │ │ │ │ ldrb r4, [ip, r0, lsr #12] │ │ │ │ @ instruction: 0xf9b78823 │ │ │ │ @ instruction: 0xf0232002 │ │ │ │ eorhi r0, r3, r2, lsl #6 │ │ │ │ vstmiale r3, {s5-s4} │ │ │ │ ldrb r4, [r2, r0, lsr #12] │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi c4fb8 <__bss_end__@@Base+0x1e380> │ │ │ │ + blhi c4e80 <__bss_end__@@Base+0x1e2e0> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ ldcleq 8, cr15, [r0, #816] @ 0x330 │ │ │ │ stcvc 5, cr15, [r1, #-692] @ 0xfffffd4c │ │ │ │ @ instruction: 0xf9b04617 │ │ │ │ ldrmi r2, [ip], -r2 │ │ │ │ strmi r4, [r2], ip, asr #23 │ │ │ │ cdp 2, 11, cr9, cr0, cr2, {0} │ │ │ │ - bmi ff2ec824 <__bss_end__@@Base+0xff245bec> │ │ │ │ + bmi ff2ec6ec <__bss_end__@@Base+0xff245b4c> │ │ │ │ vrhadd.s8 d25, d0, d4 │ │ │ │ ldrbtmi r1, [sl], #-509 @ 0xfffffe03 │ │ │ │ ldrbtmi r4, [lr], #-3785 @ 0xfffff137 │ │ │ │ @ instruction: 0x463058d3 │ │ │ │ ldmdavs fp, {r3, r4, r5, r9, sp} │ │ │ │ @ instruction: 0xf04f937f │ │ │ │ movwcs r0, #768 @ 0x300 │ │ │ │ - @ instruction: 0xff54f009 │ │ │ │ + @ instruction: 0xf85cf00a │ │ │ │ ldrbmi r9, [r4], r2, lsl #20 │ │ │ │ strmi r4, [r5], -r0, lsl #13 │ │ │ │ - bl adb54 <__bss_end__@@Base+0x6f1c> │ │ │ │ + bl ada1c <__bss_end__@@Base+0x6e7c> │ │ │ │ ldm ip!, {r1, r6, r9, sl, fp} │ │ │ │ - strgt r0, [pc, #-15] @ 9b49 │ │ │ │ + strgt r0, [pc, #-15] @ 9a11 │ │ │ │ @ instruction: 0x000fe8bc │ │ │ │ ldm ip!, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ - strgt r0, [pc, #-15] @ 9b55 │ │ │ │ + strgt r0, [pc, #-15] @ 9a1d │ │ │ │ sbceq lr, lr, #323584 @ 0x4f000 │ │ │ │ ldm ip, {r8, r9, sp} │ │ │ │ stm r5, {r0, r1} │ │ │ │ ldcge 0, cr0, [r2, #-12] │ │ │ │ ldrtmi r9, [r0], -r2, lsl #18 │ │ │ │ andne pc, r2, r8, lsr #17 │ │ │ │ @ instruction: 0xf240ae3e │ │ │ │ - @ instruction: 0xf0092106 │ │ │ │ - andcs pc, r0, #51, 30 @ 0xcc │ │ │ │ + @ instruction: 0xf00a2106 │ │ │ │ + andcs pc, r0, #3866624 @ 0x3b0000 │ │ │ │ eoreq pc, r0, r8, asr #17 │ │ │ │ andls r2, r5, r0, lsl #6 │ │ │ │ stmib r5, {r4, r5, r9, sl, lr}^ │ │ │ │ ldmdbge r8, {r8, r9, sp} │ │ │ │ movwcs lr, #18885 @ 0x49c5 │ │ │ │ tstcs r8, #3358720 @ 0x334000 │ │ │ │ tstcs sl, #3358720 @ 0x334000 │ │ │ │ movwcs r2, #512 @ 0x200 │ │ │ │ mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ movwcs lr, #10693 @ 0x29c5 │ │ │ │ stmib sp, {r0, r1, r8, ip, pc}^ │ │ │ │ @ instruction: 0xf001231c │ │ │ │ - mrc 8, 5, APSR_nzcv, cr5, cr13, {3} │ │ │ │ + @ instruction: 0xeeb5f90d │ │ │ │ vneg.f64 d24, d0 │ │ │ │ @ instruction: 0xf040fa10 │ │ │ │ ldc 1, cr8, [r4, #148] @ 0x94 │ │ │ │ @ instruction: 0xf10d7b00 │ │ │ │ @ instruction: 0xed9f0918 │ │ │ │ @ instruction: 0x46216b99 │ │ │ │ cdp 6, 11, cr4, cr0, cr10, {2} │ │ │ │ vcmpe.f64 d7, d7 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ strle pc, [r9, #-2576] @ 0xfffff5f0 │ │ │ │ - blvc c5238 <__bss_end__@@Base+0x1e600> │ │ │ │ - blvc ff2056ac <__bss_end__@@Base+0xff15ea74> │ │ │ │ - blvc ff1c56c0 <__bss_end__@@Base+0xff11ea88> │ │ │ │ - blx 4457b8 <__bss_end__@@Base+0x39eb80> │ │ │ │ + blvc c5100 <__bss_end__@@Base+0x1e560> │ │ │ │ + blvc ff205574 <__bss_end__@@Base+0xff15e9d4> │ │ │ │ + blvc ff1c5588 <__bss_end__@@Base+0xff11e9e8> │ │ │ │ + blx 445680 <__bss_end__@@Base+0x39eae0> │ │ │ │ mrshi pc, (UNDEF: 24) @ │ │ │ │ - @ instruction: 0xf0009803 │ │ │ │ - ldc 15, cr15, [r9, #1012] @ 0x3f4 │ │ │ │ + @ instruction: 0xf0019803 │ │ │ │ + ldc 8, cr15, [r9, #520] @ 0x208 │ │ │ │ @ instruction: 0xf10d4b02 │ │ │ │ vldr d0, [r9, #192] @ 0xc0 │ │ │ │ ldrbmi r3, [sl], -r0, lsl #22 │ │ │ │ - blpl 145274 <__bss_end__@@Base+0x9e63c> │ │ │ │ + blpl 14513c <__bss_end__@@Base+0x9e59c> │ │ │ │ cdp 6, 2, cr4, cr4, cr9, {2} │ │ │ │ strtmi r7, [r0], -r4, lsl #22 │ │ │ │ - blvc 105428 <__bss_end__@@Base+0x5e7f0> │ │ │ │ + blvc 1052f0 <__bss_end__@@Base+0x5e750> │ │ │ │ ldmdaeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ - blvc 185438 <__bss_end__@@Base+0xde800> │ │ │ │ - blvs ff2056ec <__bss_end__@@Base+0xff15eab4> │ │ │ │ - blcs 1c5638 <__bss_end__@@Base+0x11ea00> │ │ │ │ - blvc 1c5644 <__bss_end__@@Base+0x11ea0c> │ │ │ │ - blcc 1c5644 <__bss_end__@@Base+0x11ea0c> │ │ │ │ - blcs 4525c │ │ │ │ - blvc 145260 <__bss_end__@@Base+0x9e628> │ │ │ │ - blcc c5264 <__bss_end__@@Base+0x1e62c> │ │ │ │ - @ instruction: 0xffdaf000 │ │ │ │ - blmi c52b4 <__bss_end__@@Base+0x1e67c> │ │ │ │ - blcc 452b8 │ │ │ │ + blvc 185300 <__bss_end__@@Base+0xde760> │ │ │ │ + blvs ff2055b4 <__bss_end__@@Base+0xff15ea14> │ │ │ │ + blcs 1c5500 <__bss_end__@@Base+0x11e960> │ │ │ │ + blvc 1c550c <__bss_end__@@Base+0x11e96c> │ │ │ │ + blcc 1c550c <__bss_end__@@Base+0x11e96c> │ │ │ │ + blcs 45124 │ │ │ │ + blvc 145128 <__bss_end__@@Base+0x9e588> │ │ │ │ + blcc c512c <__bss_end__@@Base+0x1e58c> │ │ │ │ + @ instruction: 0xf85ff001 │ │ │ │ + blmi c517c <__bss_end__@@Base+0x1e5dc> │ │ │ │ + blcc 45180 │ │ │ │ ldc 6, cr4, [fp, #256] @ 0x100 │ │ │ │ vmul.f64 d5, d4, d4 │ │ │ │ vmla.f64 d7, d3, d4 │ │ │ │ vmla.f64 d7, d5, d3 │ │ │ │ vmov.f64 d7, #21 @ 0x40a80000 5.250 │ │ │ │ @ instruction: 0xee836bc7 │ │ │ │ vdiv.f64 d2, d5, d6 │ │ │ │ vdiv.f64 d7, d4, d6 │ │ │ │ vstr d3, [fp, #24] │ │ │ │ vstr d2, [fp] │ │ │ │ vstr d7, [fp, #16] │ │ │ │ @ instruction: 0xf0013b02 │ │ │ │ - ldc 8, cr15, [r9, #108] @ 0x6c │ │ │ │ + ldc 8, cr15, [r9, #684] @ 0x2ac │ │ │ │ ldrtmi r7, [r0], -r0, lsl #22 │ │ │ │ movwcs sl, #15966 @ 0x3e5e │ │ │ │ stc 6, cr4, [r8, #200] @ 0xc8 │ │ │ │ strbmi r7, [r1], -r0, lsl #22 │ │ │ │ - blvc c52f8 <__bss_end__@@Base+0x1e6c0> │ │ │ │ - blvc 2452b8 <__bss_end__@@Base+0x19e680> │ │ │ │ - blvc 145300 <__bss_end__@@Base+0x9e6c8> │ │ │ │ - blvc 4452c0 <__bss_end__@@Base+0x39e688> │ │ │ │ - blvc 45310 │ │ │ │ - blvc c52c8 <__bss_end__@@Base+0x1e690> │ │ │ │ - blvc c5318 <__bss_end__@@Base+0x1e6e0> │ │ │ │ - blvc 2c52d0 <__bss_end__@@Base+0x21e698> │ │ │ │ - blvc 145320 <__bss_end__@@Base+0x9e6e8> │ │ │ │ - blvc 4c52d8 <__bss_end__@@Base+0x41e6a0> │ │ │ │ - blvc 4530c │ │ │ │ - blvc 1452e0 <__bss_end__@@Base+0x9e6a8> │ │ │ │ - blvc c5314 <__bss_end__@@Base+0x1e6dc> │ │ │ │ - blvc 3452e8 <__bss_end__@@Base+0x29e6b0> │ │ │ │ - blvc 14531c <__bss_end__@@Base+0x9e6e4> │ │ │ │ - blvc 5452f0 <__bss_end__@@Base+0x49e6b8> │ │ │ │ - @ instruction: 0xf8aaf001 │ │ │ │ + blvc c51c0 <__bss_end__@@Base+0x1e620> │ │ │ │ + blvc 245180 <__bss_end__@@Base+0x19e5e0> │ │ │ │ + blvc 1451c8 <__bss_end__@@Base+0x9e628> │ │ │ │ + blvc 445188 <__bss_end__@@Base+0x39e5e8> │ │ │ │ + blvc 451d8 │ │ │ │ + blvc c5190 <__bss_end__@@Base+0x1e5f0> │ │ │ │ + blvc c51e0 <__bss_end__@@Base+0x1e640> │ │ │ │ + blvc 2c5198 <__bss_end__@@Base+0x21e5f8> │ │ │ │ + blvc 1451e8 <__bss_end__@@Base+0x9e648> │ │ │ │ + blvc 4c51a0 <__bss_end__@@Base+0x41e600> │ │ │ │ + blvc 451d4 │ │ │ │ + blvc 1451a8 <__bss_end__@@Base+0x9e608> │ │ │ │ + blvc c51dc <__bss_end__@@Base+0x1e63c> │ │ │ │ + blvc 3451b0 <__bss_end__@@Base+0x29e610> │ │ │ │ + blvc 1451e4 <__bss_end__@@Base+0x9e644> │ │ │ │ + blvc 5451b8 <__bss_end__@@Base+0x49e618> │ │ │ │ + @ instruction: 0xf948f001 │ │ │ │ addcs r4, r0, #51380224 @ 0x3100000 │ │ │ │ @ instruction: 0xf7f94640 │ │ │ │ - bls 104780 <__bss_end__@@Base+0x5db48> │ │ │ │ + bls 104828 <__bss_end__@@Base+0x5dc88> │ │ │ │ strbmi r9, [r1], -r4, lsl #16 │ │ │ │ - blx 1045cee <__bss_end__@@Base+0xf9f0b6> │ │ │ │ - blcs 308f4 │ │ │ │ - blls 811dc <__bss_start@@Base+0x2613c> │ │ │ │ + ldc2l 0, cr15, [r0], #4 │ │ │ │ + blcs 307bc │ │ │ │ + blls 810a4 <__bss_start@@Base+0x2609c> │ │ │ │ stmib sp, {r9, sl, sp}^ │ │ │ │ @ instruction: 0xf8dd9b03 │ │ │ │ - bvs 6f5d1c <__bss_end__@@Base+0x64f0e4> │ │ │ │ + bvs 6f5be4 <__bss_end__@@Base+0x64f044> │ │ │ │ @ instruction: 0xf8da2218 │ │ │ │ - blx 99d86 <__bss_start@@Base+0x3ece6> │ │ │ │ + blx 99c4e <__bss_start@@Base+0x3ec46> │ │ │ │ strcc pc, [r1], -r6, lsl #18 │ │ │ │ - bl dae3c <__bss_end__@@Base+0x34204> │ │ │ │ + bl dad04 <__bss_end__@@Base+0x34164> │ │ │ │ ldrbtmi r0, [r4], r9, lsl #28 │ │ │ │ stmia ip!, {r0, r1, r2, r3, sl, fp, lr, pc} │ │ │ │ strtmi r0, [sl], -pc │ │ │ │ muleq r3, r4, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ @ instruction: 0x46414670 │ │ │ │ - blx 845d2e <__bss_end__@@Base+0x79f0f6> │ │ │ │ + ldc2l 0, cr15, [r0], {1} │ │ │ │ vldr d9, [r5, #4] │ │ │ │ ldrmi r5, [r3, #2816]! @ 0xb00 │ │ │ │ - blcc 45390 │ │ │ │ - blvs c538c <__bss_end__@@Base+0x1e754> │ │ │ │ - blmi c5398 <__bss_end__@@Base+0x1e760> │ │ │ │ - blvc 145394 <__bss_end__@@Base+0x9e75c> │ │ │ │ - blpl 1055d8 <__bss_end__@@Base+0x5e9a0> │ │ │ │ - blcs 1453a4 <__bss_end__@@Base+0x9e76c> │ │ │ │ + blcc 45258 │ │ │ │ + blvs c5254 <__bss_end__@@Base+0x1e6b4> │ │ │ │ + blmi c5260 <__bss_end__@@Base+0x1e6c0> │ │ │ │ + blvc 14525c <__bss_end__@@Base+0x9e6bc> │ │ │ │ + blpl 1054a0 <__bss_end__@@Base+0x5e900> │ │ │ │ + blcs 14526c <__bss_end__@@Base+0x9e6cc> │ │ │ │ @ instruction: 0xee266a1b │ │ │ │ vmul.f64 d6, d7, d4 │ │ │ │ ldrmi r7, [r9], #2818 @ 0xb02 │ │ │ │ - blpl 4537c │ │ │ │ - blvs c5380 <__bss_end__@@Base+0x1e748> │ │ │ │ - blvc 145384 <__bss_end__@@Base+0x9e74c> │ │ │ │ + blpl 45244 │ │ │ │ + blvs c5248 <__bss_end__@@Base+0x1e6a8> │ │ │ │ + blvc 14524c <__bss_end__@@Base+0x9e6ac> │ │ │ │ ldmib sp, {r2, r3, r6, r7, r8, ip, lr, pc}^ │ │ │ │ - blls 70974 <__bss_start@@Base+0x158d4> │ │ │ │ + blls 7083c <__bss_start@@Base+0x15834> │ │ │ │ @ instruction: 0x3000f9b3 │ │ │ │ ldrtle r0, [sl], #-1882 @ 0xfffff8a6 │ │ │ │ strle r0, [r2], #-2011 @ 0xfffff825 │ │ │ │ - bvs fe6f097c <__bss_end__@@Base+0xfe649d44> │ │ │ │ - blls 176c28 <__bss_end__@@Base+0xcfff0> │ │ │ │ + bvs fe6f0844 <__bss_end__@@Base+0xfe649ca4> │ │ │ │ + blls 176af0 <__bss_end__@@Base+0xcff50> │ │ │ │ stcls 6, cr4, [r1], {89} @ 0x59 │ │ │ │ @ instruction: 0xf1044648 │ │ │ │ ldc 2, cr0, [r3, #32] │ │ │ │ vldr d2, [r3, #24] │ │ │ │ vldr d3, [r3, #32] │ │ │ │ vldr d4, [r3, #40] @ 0x28 │ │ │ │ vldr d5, [r3] │ │ │ │ @@ -6635,70 +6583,70 @@ │ │ │ │ vldr d5, [r3, #264] @ 0x108 │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vsub.f64 d6, d7, d3 │ │ │ │ vstr d7, [fp, #272] @ 0x110 │ │ │ │ vstr d5, [fp] │ │ │ │ vstr d6, [fp, #8] │ │ │ │ @ instruction: 0xf0007b04 │ │ │ │ - stmdahi r3!, {r0, r2, r3, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + stmdahi r3!, {r1, r4, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ movweq pc, #16451 @ 0x4043 @ │ │ │ │ - bmi 729e74 <__bss_end__@@Base+0x68323c> │ │ │ │ + bmi 729d3c <__bss_end__@@Base+0x68319c> │ │ │ │ ldrbtmi r4, [sl], #-2840 @ 0xfffff4e8 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, pc, ror fp │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ stmdals r1, {r0, r1, r2, r4, r8, ip, lr, pc} │ │ │ │ stcvc 5, cr15, [r1, #-52] @ 0xffffffcc │ │ │ │ - blhi c50f8 <__bss_end__@@Base+0x1e4c0> │ │ │ │ + blhi c4fc0 <__bss_end__@@Base+0x1e420> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf0004628 │ │ │ │ - @ instruction: 0xe6f6fef5 │ │ │ │ - blvc 2c5490 <__bss_end__@@Base+0x21e858> │ │ │ │ - ldc 1, cr2, [pc, #12] @ 9e24 │ │ │ │ + @ instruction: 0xe6f6ff7a │ │ │ │ + blvc 2c5358 <__bss_end__@@Base+0x21e7b8> │ │ │ │ + ldc 1, cr2, [pc, #12] @ 9cec │ │ │ │ ldrtmi r0, [r0], -fp, lsl #22 │ │ │ │ - blhi 2056c0 <__bss_end__@@Base+0x15ea88> │ │ │ │ - bleq 45844 │ │ │ │ - @ instruction: 0xf8acf001 │ │ │ │ + blhi 205588 <__bss_end__@@Base+0x15e9e8> │ │ │ │ + bleq 4570c │ │ │ │ + @ instruction: 0xf961f001 │ │ │ │ @ instruction: 0xf7f9e6cd │ │ │ │ - svclt 0x0000eac8 │ │ │ │ + svclt 0x0000eb40 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ svccc 0x00900000 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - ldrdeq lr, [r4], -r6 │ │ │ │ - strdeq r0, [r4], -lr │ │ │ │ - andeq lr, r4, r6, lsl r2 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq lr, r4, lr, lsl #12 │ │ │ │ + andeq r0, r4, lr, lsr #9 │ │ │ │ + andeq lr, r4, lr, asr #6 │ │ │ │ ldrsbcc pc, [r8], #128 @ 0x80 @ │ │ │ │ ldrlt fp, [r0, #-387] @ 0xfffffe7d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00f8f8cc │ │ │ │ - bvs 61b684 <__bss_end__@@Base+0x574a4c> │ │ │ │ - cdp2 0, 6, cr15, cr10, cr9, {0} │ │ │ │ + bvs 61b54c <__bss_end__@@Base+0x5749ac> │ │ │ │ + @ instruction: 0xff72f009 │ │ │ │ ldrsbeq pc, [r8], #132 @ 0x84 @ │ │ │ │ @ instruction: 0x4010e8bd │ │ │ │ - cdplt 0, 6, cr15, cr4, cr9, {0} │ │ │ │ + svclt 0x006cf009 │ │ │ │ svclt 0x00004770 │ │ │ │ @ instruction: 0xf7fc6840 │ │ │ │ - svclt 0x0000b867 │ │ │ │ + svclt 0x0000b8cf │ │ │ │ vqdmulh.s d20, d8, d8 │ │ │ │ vmov.i32 d21, #24320 @ 0x00005f00 │ │ │ │ stmdami r7, {r0, r1, r3, r5, r6, r7, r9, ip} │ │ │ │ ldmdapl fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0x018af9b3 │ │ │ │ @ instruction: 0xf101fb00 │ │ │ │ - blx fe08fdce <__bss_end__@@Base+0xfdfe9196> │ │ │ │ - bl ff0122b4 <__bss_end__@@Base+0xfef6b67c> │ │ │ │ + blx fe08fc96 <__bss_end__@@Base+0xfdfe90f6> │ │ │ │ + bl ff01217c <__bss_end__@@Base+0xfef6b5dc> │ │ │ │ ldrbmi r3, [r0, -r1, rrx]! │ │ │ │ - andeq lr, r4, r4, ror #2 │ │ │ │ - andeq r0, r0, ip, lsl #6 │ │ │ │ + muleq r4, ip, r2 │ │ │ │ + andeq r0, r0, r4, lsl #6 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00a0f8cc │ │ │ │ ldclmi 0, cr11, [r7, #-572] @ 0xfffffdc4 │ │ │ │ ldrbtmi r4, [sp], #-1564 @ 0xfffff9e4 │ │ │ │ @ instruction: 0xf8bd9f18 │ │ │ │ @@ -6709,68 +6657,68 @@ │ │ │ │ strtmi r8, [r7], #-158 @ 0xffffff62 │ │ │ │ vmax.s8 d20, d8, d26 │ │ │ │ vorr.i16 d21, #24320 @ 0x5f00 │ │ │ │ strmi r1, [r9], fp, ror #23 │ │ │ │ @ instruction: 0x4625463e │ │ │ │ adcsmi lr, r5, #2 │ │ │ │ addshi pc, r1, r0 │ │ │ │ - blmi 87f5c <__bss_start@@Base+0x2cebc> │ │ │ │ + blmi 87e24 <__bss_start@@Base+0x2ce1c> │ │ │ │ ldclle 12, cr2, [r8], #508 @ 0x1fc │ │ │ │ ldmpl r1, {r3, r6, r8, r9, fp, lr}^ │ │ │ │ tstls r9, r6, lsl #6 │ │ │ │ vqrdmulh.s d15, d4, d3 │ │ │ │ @ instruction: 0x0c03eb01 │ │ │ │ @ instruction: 0xf9bc5ecb │ │ │ │ - blcs 9f2c │ │ │ │ + blcs 9df4 │ │ │ │ stmdbmi r3, {r0, r2, r3, r5, r6, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf8524b43 │ │ │ │ tstcs r2, r1 │ │ │ │ - bl 60280 <__bss_start@@Base+0x51e0> │ │ │ │ + bl 60148 <__bss_start@@Base+0x5140> │ │ │ │ andcs r0, r0, r0, lsl #3 │ │ │ │ eorgt pc, r0, sp, asr #17 │ │ │ │ stmdaeq r3, {r0, r8, r9, fp, sp, lr, pc} │ │ │ │ ldrbtmi r4, [r0], -r4, lsl #13 │ │ │ │ strmi lr, [sl], -sp, asr #19 │ │ │ │ andpl lr, ip, #3358720 @ 0x334000 │ │ │ │ @ instruction: 0x3000f9b8 │ │ │ │ @ instruction: 0x2c02f938 │ │ │ │ - bcs 4a1cc │ │ │ │ + bcs 4a094 │ │ │ │ tsteq r5, r0, lsl #22 │ │ │ │ eorcc pc, r3, r0, lsr r9 @ │ │ │ │ @ instruction: 0x4002f9b1 │ │ │ │ vqrdmulh.s d15, d3, d10 │ │ │ │ @ instruction: 0xf404fb0a │ │ │ │ smlabbvs r3, fp, fp, pc @ │ │ │ │ mvnvc lr, #323584 @ 0x4f000 │ │ │ │ cmncc r1, #199680 @ 0x30c00 │ │ │ │ smlabbvs r4, fp, fp, pc @ │ │ │ │ streq lr, [r9, -r3, lsl #22] │ │ │ │ strbtvc lr, [r4], #2639 @ 0xa4f │ │ │ │ - bl fe930b94 <__bss_end__@@Base+0xfe889f5c> │ │ │ │ + bl fe930a5c <__bss_end__@@Base+0xfe889ebc> │ │ │ │ ldrmi r3, [ip], #-1121 @ 0xfffffb9f │ │ │ │ strcc sp, [r8, #-3372] @ 0xfffff2d4 │ │ │ │ strmi r2, [r5], #-1537 @ 0xfffff9ff │ │ │ │ andgt lr, r6, sp, asr #19 │ │ │ │ @ instruction: 0x3c04f935 │ │ │ │ @ instruction: 0xf9354622 │ │ │ │ ldrtmi r4, [r9], -r2, lsl #24 │ │ │ │ strcc r9, [r1], -r5, lsl #16 │ │ │ │ strcc r9, [r4, #-1] │ │ │ │ vqrdmulh.s d15, d3, d10 │ │ │ │ @ instruction: 0xf404fb0a │ │ │ │ andgt pc, r3, fp, lsl #23 │ │ │ │ - bl ff0cff28 <__bss_end__@@Base+0xff0292f0> │ │ │ │ - blx fe2d6d42 <__bss_end__@@Base+0xfe23010a> │ │ │ │ - bl f9fd4 <__bss_end__@@Base+0x5339c> │ │ │ │ + bl ff0cfdf0 <__bss_end__@@Base+0xff029250> │ │ │ │ + blx fe2d6c0a <__bss_end__@@Base+0xfe23006a> │ │ │ │ + bl f9e9c <__bss_end__@@Base+0x532fc> │ │ │ │ strbne r0, [r4, r9, lsl #14]! │ │ │ │ - bl fe930bd8 <__bss_end__@@Base+0xfe889fa0> │ │ │ │ + bl fe930aa0 <__bss_end__@@Base+0xfe889f00> │ │ │ │ ldrmi r3, [ip], #-1120 @ 0xfffffba0 │ │ │ │ strls r9, [r0], #-2820 @ 0xfffff4fc │ │ │ │ @ instruction: 0x463b6858 │ │ │ │ - @ instruction: 0xf804f7fc │ │ │ │ + @ instruction: 0xf86cf7fc │ │ │ │ @ instruction: 0x2c02f938 │ │ │ │ ldclle 2, cr4, [r9], {178} @ 0xb2 │ │ │ │ ldrdgt lr, [r6], -sp │ │ │ │ stceq 1, cr15, [r1], {12} │ │ │ │ @ instruction: 0xf1089b08 │ │ │ │ @ instruction: 0xf9b30804 │ │ │ │ strbmi r3, [r3, #-0]! │ │ │ │ @@ -6783,36 +6731,36 @@ │ │ │ │ vqrdmulh.s d15, d3, d10 │ │ │ │ mvnvc lr, pc, asr #20 │ │ │ │ movweq pc, #15243 @ 0x3b8b @ │ │ │ │ cmncc r3, #197632 @ 0x30400 │ │ │ │ @ instruction: 0xf47f4499 │ │ │ │ andlt sl, pc, pc, ror #30 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - andeq lr, r4, lr, lsr #2 │ │ │ │ - andeq r0, r0, ip, lsl #6 │ │ │ │ - andeq r0, r0, ip, asr #5 │ │ │ │ - andeq r0, r0, ip, ror #4 │ │ │ │ + andeq lr, r4, r6, ror #4 │ │ │ │ + andeq r0, r0, r4, lsl #6 │ │ │ │ + andeq r0, r0, r4, asr #5 │ │ │ │ + andeq r0, r0, r4, ror #4 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ @ instruction: 0x461c4693 │ │ │ │ - bmi 187627c <__bss_end__@@Base+0x17cf644> │ │ │ │ + bmi 1876144 <__bss_end__@@Base+0x17cf5a4> │ │ │ │ ldrbtmi r4, [sl], #-1551 @ 0xfffff9f1 │ │ │ │ @ instruction: 0x5016e9dd │ │ │ │ - blls 62ec6c <__bss_end__@@Base+0x588034> │ │ │ │ + blls 62eb34 <__bss_end__@@Base+0x587f94> │ │ │ │ stmdavs r9!, {r0, r3, r4, r9, sl, fp, ip, pc} │ │ │ │ vqrdmulh.s d18, d0, d0 │ │ │ │ - bl 2a328 │ │ │ │ + bl 2a1f0 │ │ │ │ vmla.i8 d16, d8, d3 │ │ │ │ vmov.i16 d21, #24320 @ 0x5f00 │ │ │ │ @ instruction: 0xf1a41aeb │ │ │ │ strbmi r0, [ip], r8, lsl #6 │ │ │ │ strmi r9, [r9], r7, lsl #6 │ │ │ │ @ instruction: 0x46014613 │ │ │ │ strbmi lr, [r1, #-2]! │ │ │ │ addshi pc, pc, r0 │ │ │ │ - blcs 880c8 <__bss_start@@Base+0x2d028> │ │ │ │ + blcs 87f90 <__bss_start@@Base+0x2cf88> │ │ │ │ vldmiale r8!, {s5-s131} │ │ │ │ @ instruction: 0xf8534851 │ │ │ │ andcs r8, r6, r0 │ │ │ │ @ instruction: 0xf002fb00 │ │ │ │ streq lr, [r0], #-2824 @ 0xfffff4f8 │ │ │ │ andeq pc, r0, r8, lsr r9 @ │ │ │ │ @ instruction: 0x4002f9b4 │ │ │ │ @@ -6821,63 +6769,63 @@ │ │ │ │ ldmdapl sp, {r1, r3, r6, fp, lr} │ │ │ │ strls r4, [r5, #-2122] @ 0xfffff7b6 │ │ │ │ and pc, r0, r3, asr r8 @ │ │ │ │ stmib sp, {r3, r5, r7, sl, fp, ip}^ │ │ │ │ strbmi r2, [ip], r8, lsl #24 │ │ │ │ stmdacc sl, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ strdls r4, [r4], -r0 │ │ │ │ - blls 12e524 <__bss_end__@@Base+0x878ec> │ │ │ │ + blls 12e3ec <__bss_end__@@Base+0x8784c> │ │ │ │ @ instruction: 0xf9339a05 │ │ │ │ @ instruction: 0xf9323024 │ │ │ │ addseq r5, r8, r4, lsr #32 │ │ │ │ @ instruction: 0xf9382d01 │ │ │ │ - bl 216168 <__bss_end__@@Base+0x16f530> │ │ │ │ + bl 216030 <__bss_end__@@Base+0x16f490> │ │ │ │ @ instruction: 0xf9b20200 │ │ │ │ - blx 1920ee <__bss_end__@@Base+0xeb4b6> │ │ │ │ - blx 1c6cf6 <__bss_end__@@Base+0x1200be> │ │ │ │ - blx fe2c68f6 <__bss_end__@@Base+0xfe21fcbe> │ │ │ │ - b 14024fc <__bss_end__@@Base+0x135b8c4> │ │ │ │ - bl ff0e7080 <__bss_end__@@Base+0xff040448> │ │ │ │ - blx fe296e7e <__bss_end__@@Base+0xfe1f0246> │ │ │ │ - b 1402504 <__bss_end__@@Base+0x135b8cc> │ │ │ │ + blx 191fb6 <__bss_end__@@Base+0xeb416> │ │ │ │ + blx 1c6bbe <__bss_end__@@Base+0x12001e> │ │ │ │ + blx fe2c67be <__bss_end__@@Base+0xfe21fc1e> │ │ │ │ + b 14023c4 <__bss_end__@@Base+0x135b824> │ │ │ │ + bl ff0e6f48 <__bss_end__@@Base+0xff0403a8> │ │ │ │ + blx fe296d46 <__bss_end__@@Base+0xfe1f01a6> │ │ │ │ + b 14023cc <__bss_end__@@Base+0x135b82c> │ │ │ │ ldrtmi r7, [fp], #-738 @ 0xfffffd1e │ │ │ │ rsbcc lr, r1, #165888 @ 0x28800 │ │ │ │ ldcle 4, cr4, [lr, #-360]! @ 0xfffffe98 │ │ │ │ - bl 330528 <__bss_end__@@Base+0x2898f0> │ │ │ │ + bl 3303f0 <__bss_end__@@Base+0x289850> │ │ │ │ andcc r0, r8, r5, lsl #28 │ │ │ │ strmi lr, [r0, #-2509] @ 0xfffff633 │ │ │ │ @ instruction: 0xf8cd4440 │ │ │ │ - bl 7a13c <__bss_start@@Base+0x1f09c> │ │ │ │ + bl 7a004 <__bss_start@@Base+0x1effc> │ │ │ │ stmdbls r6, {r1, r2, r3, r6, r7, r9, sl, fp} │ │ │ │ biceq lr, ip, r1, lsl #22 │ │ │ │ @ instruction: 0xf930461d │ │ │ │ ldrmi r3, [r4], -r4, lsl #24 │ │ │ │ @ instruction: 0x2c02f930 │ │ │ │ andcc r3, r4, r8, lsl #2 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<__bss_end__@@Base+0x304a8> │ │ │ │ + blls cd064 <__bss_end__@@Base+0x264c4> │ │ │ │ addsmi r3, ip, #16777216 @ 0x1000000 │ │ │ │ usatmi sp, #1, fp, lsl #3 │ │ │ │ @ instruction: 0xf8dd9a08 │ │ │ │ ldmdbls r7, {r2, r5, lr, pc} │ │ │ │ stmdacc sl, {r0, r2, r3, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ strbmi r2, [r1, #-6]! │ │ │ │ stmdahi r2, {r8, r9, fp, ip, sp, lr, pc} │ │ │ │ @@ -6887,18 +6835,18 @@ │ │ │ │ andmi pc, r2, #141312 @ 0x22800 │ │ │ │ rsbcc lr, r2, #192, 22 @ 0x30000 │ │ │ │ @ instruction: 0xf47f4417 │ │ │ │ ldcls 15, cr10, [r6, #-388] @ 0xfffffe7c │ │ │ │ eorvs r4, r9, r9, asr #12 │ │ │ │ pop {r0, r2, r3, ip, sp, pc} │ │ │ │ svclt 0x00008ff0 │ │ │ │ - @ instruction: 0x0004dfb6 │ │ │ │ - andeq r0, r0, ip, lsl #6 │ │ │ │ - andeq r0, r0, ip, ror #4 │ │ │ │ - andeq r0, r0, ip, asr #5 │ │ │ │ + andeq lr, r4, lr, ror #1 │ │ │ │ + andeq r0, r0, r4, lsl #6 │ │ │ │ + andeq r0, r0, r4, ror #4 │ │ │ │ + andeq r0, r0, r4, asr #5 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ andeq pc, r0, ip, asr #17 │ │ │ │ stcpl 5, cr15, [r0], {172} @ 0xac │ │ │ │ andeq pc, r0, ip, asr #17 │ │ │ │ ldceq 8, cr15, [r8], #-304 @ 0xfffffed0 │ │ │ │ @@ -6916,92 +6864,92 @@ │ │ │ │ ldceq 1, cr15, [r8], {3} │ │ │ │ stcvs 3, cr2, [r1, #-96] @ 0xffffffa0 │ │ │ │ ldmdaeq r0, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ streq pc, [r4], -r8, lsr #3 │ │ │ │ strhtge pc, [r2], -r0 @ │ │ │ │ smuadgt r3, r7, fp │ │ │ │ strhtls pc, [r0], -r0 @ │ │ │ │ - blcs 445884 <__bss_end__@@Base+0x39ec4c> │ │ │ │ + blcs 44574c <__bss_end__@@Base+0x39ebac> │ │ │ │ tstpeq r2, r1 @ p-variant is OBSOLETE │ │ │ │ - blcc 3c588c <__bss_end__@@Base+0x31ec54> │ │ │ │ + blcc 3c5754 <__bss_end__@@Base+0x31ebb4> │ │ │ │ ldrtmi r2, [r5], -r0, lsl #8 │ │ │ │ andlt pc, r4, sp, asr #17 │ │ │ │ ldc 0, cr14, [ip, #-176] @ 0xffffff50 │ │ │ │ vmov.f64 d5, #82 @ 0x3e900000 0.2812500 │ │ │ │ vneg.f64 d21, d0 │ │ │ │ eorle pc, pc, r0, lsl sl @ │ │ │ │ - blmi 185c80 <__bss_end__@@Base+0xdf048> │ │ │ │ - blvs 185c88 <__bss_end__@@Base+0xdf050> │ │ │ │ - blvc ff145e64 <__bss_end__@@Base+0xff09f22c> │ │ │ │ - bcc fe445ad0 <__bss_end__@@Base+0xfe39ee98> │ │ │ │ - blvc ff1c5e6c <__bss_end__@@Base+0xff11f234> │ │ │ │ + blmi 185b48 <__bss_end__@@Base+0xdefa8> │ │ │ │ + blvs 185b50 <__bss_end__@@Base+0xdefb0> │ │ │ │ + blvc ff145d2c <__bss_end__@@Base+0xff09f18c> │ │ │ │ + bcc fe445998 <__bss_end__@@Base+0xfe39edf8> │ │ │ │ + blvc ff1c5d34 <__bss_end__@@Base+0xff11f194> │ │ │ │ cdp 4, 1, cr4, cr7, cr11, {2} │ │ │ │ vpmin.u8 d16, d19, d0 │ │ │ │ ldrbmi r0, [r0], #-911 @ 0xfffffc71 │ │ │ │ addeq pc, pc, r0, asr #6 │ │ │ │ - bleq fe144bc8 <__bss_end__@@Base+0xfe09df90> │ │ │ │ + bleq fe144a90 <__bss_end__@@Base+0xfe09def0> │ │ │ │ vmlaeq.f64 d14, d11, d8 │ │ │ │ stceq 8, cr15, [r2], {46} @ 0x2e │ │ │ │ stccc 8, cr15, [r4], {46} @ 0x2e │ │ │ │ @ instruction: 0xf9b5b11c │ │ │ │ ldrmi lr, [lr] │ │ │ │ @ instruction: 0xf10cd01f │ │ │ │ - bl 18d308 <__bss_end__@@Base+0xe66d0> │ │ │ │ + bl 18d1d0 <__bss_end__@@Base+0xe6630> │ │ │ │ strcc r0, [r1], #-1291 @ 0xfffffaf5 │ │ │ │ strhtle r4, [r0], -ip │ │ │ │ - blvs 1c5724 <__bss_end__@@Base+0x11eaec> │ │ │ │ - blvc 145728 <__bss_end__@@Base+0x9eaf0> │ │ │ │ - blvs 1c5b48 <__bss_end__@@Base+0x11ef10> │ │ │ │ - blvc 205b48 <__bss_end__@@Base+0x15ef10> │ │ │ │ + blvs 1c55ec <__bss_end__@@Base+0x11ea4c> │ │ │ │ + blvc 1455f0 <__bss_end__@@Base+0x9ea50> │ │ │ │ + blvs 1c5a10 <__bss_end__@@Base+0x11ee70> │ │ │ │ + blvc 205a10 <__bss_end__@@Base+0x15ee70> │ │ │ │ bicle r2, r8, r0, lsl #18 │ │ │ │ - blvs ff1c5ebc <__bss_end__@@Base+0xff11f284> │ │ │ │ - blvc ff205ec0 <__bss_end__@@Base+0xff15f288> │ │ │ │ - bcc fe445b28 <__bss_end__@@Base+0xfe39eef0> │ │ │ │ - beq fe445b30 <__bss_end__@@Base+0xfe39eef8> │ │ │ │ + blvs ff1c5d84 <__bss_end__@@Base+0xff11f1e4> │ │ │ │ + blvc ff205d88 <__bss_end__@@Base+0xff15f1e8> │ │ │ │ + bcc fe4459f0 <__bss_end__@@Base+0xfe39ee50> │ │ │ │ + beq fe4459f8 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pc, [r2, r3, lsl #23]! @ │ │ │ │ - stmda r2, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - strdeq sp, [r4], -lr │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - strdeq sp, [r4], -ip │ │ │ │ + strb pc, [r2, fp, ror #23]! @ │ │ │ │ + ldm sl!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + andeq sp, r4, r6, lsr pc │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq sp, r4, r4, lsr lr │ │ │ │ @ instruction: 0xf7fb6840 │ │ │ │ - svclt 0x0000bc15 │ │ │ │ + svclt 0x0000bc7d │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stceq 0, cr15, [r0], {79} @ 0x4f │ │ │ │ cdpmi 4, 4, cr15, cr0, cr15, {2} │ │ │ │ - blhi c5810 <__bss_end__@@Base+0x1ebd8> │ │ │ │ + blhi c56d8 <__bss_end__@@Base+0x1eb38> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ vmlaeq.f64 d14, d30, d28 │ │ │ │ stcpl 5, cr15, [r0], {172} @ 0xac │ │ │ │ andeq pc, r0, ip, asr #17 │ │ │ │ ldrshle r4, [r9, #84]! @ 0x54 │ │ │ │ stceq 8, cr15, [r8], #-312 @ 0xfffffec8 │ │ │ │ - blmi c5cc38 <__bss_end__@@Base+0xbb6000> │ │ │ │ + blmi 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0x1000 │ │ │ │ - blcc c5a4c <__bss_end__@@Base+0x1ee14> │ │ │ │ - blcs 45a50 │ │ │ │ - blvs 145c5c <__bss_end__@@Base+0x9f024> │ │ │ │ - blpl 105c64 <__bss_end__@@Base+0x5f02c> │ │ │ │ - blvc c5c84 <__bss_end__@@Base+0x1f04c> │ │ │ │ - blvs c5c2c <__bss_end__@@Base+0x1eff4> │ │ │ │ - blpl 45c4c │ │ │ │ - blvc 145c3c <__bss_end__@@Base+0x9f004> │ │ │ │ - blvs 145800 <__bss_end__@@Base+0x9ebc8> │ │ │ │ - blpl 1c5804 <__bss_end__@@Base+0x11ebcc> │ │ │ │ - blvc c5808 <__bss_end__@@Base+0x1ebd0> │ │ │ │ - bl 1beb5c <__bss_end__@@Base+0x117f24> │ │ │ │ + blcc c5914 <__bss_end__@@Base+0x1ed74> │ │ │ │ + blcs 45918 │ │ │ │ + blvs 145b24 <__bss_end__@@Base+0x9ef84> │ │ │ │ + blpl 105b2c <__bss_end__@@Base+0x5ef8c> │ │ │ │ + blvc c5b4c <__bss_end__@@Base+0x1efac> │ │ │ │ + blvs c5af4 <__bss_end__@@Base+0x1ef54> │ │ │ │ + blpl 45b14 │ │ │ │ + blvc 145b04 <__bss_end__@@Base+0x9ef64> │ │ │ │ + blvs 1456c8 <__bss_end__@@Base+0x9eb28> │ │ │ │ + blpl 1c56cc <__bss_end__@@Base+0x11eb2c> │ │ │ │ + blvc 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0x4631fb15 │ │ │ │ + @ instruction: 0x4631fb7d │ │ │ │ ldrtmi r4, [r8], -r2, asr #12 │ │ │ │ - blx 194848a <__bss_end__@@Base+0x18a1852> │ │ │ │ + blx ff348352 <__bss_end__@@Base+0xff2a17b2> │ │ │ │ @ instruction: 0x61206828 │ │ │ │ - blcc 45f6c │ │ │ │ - blmi 2c5afc <__bss_end__@@Base+0x21eec4> │ │ │ │ + blcc 45e34 │ │ │ │ + blmi 2c59c4 <__bss_end__@@Base+0x21ee24> │ │ │ │ stmdahi r9!, {r2, r9, sl, fp, sp, pc} │ │ │ │ - blcs 1245f74 <__bss_end__@@Base+0x119f33c> │ │ │ │ + blcs 1245e3c <__bss_end__@@Base+0x119f29c> │ │ │ │ ldc 8, cr8, [r4, #424] @ 0x1a8 │ │ │ │ vmul.f64 d5, d4, d12 │ │ │ │ addeq r6, r9, r8, lsl #22 │ │ │ │ addseq r8, r2, r1, lsr #8 │ │ │ │ @ instruction: 0xf9b58462 │ │ │ │ cdp 0, 2, cr0, cr5, cr0, {0} │ │ │ │ @ instruction: 0xf9b57b08 │ │ │ │ cdp 0, 2, cr1, cr6, cr2, {0} │ │ │ │ @ instruction: 0xf9b46b03 │ │ │ │ @ instruction: 0xf9b4300a │ │ │ │ - bne 16d2500 <__bss_end__@@Base+0x162b8c8> │ │ │ │ - bcc 445ce8 <__bss_end__@@Base+0x39f0b0> │ │ │ │ + bne 16d23c8 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mcr 2, 1, r0, cr4, cr8, {0} │ │ │ │ vmla.f64 d7, d3, d4 │ │ │ │ vmla.f64 d7, d5, d3 │ │ │ │ vmov.f64 d7, #21 @ 0x40a80000 5.250 │ │ │ │ @ instruction: 0xee836bc7 │ │ │ │ vdiv.f64 d2, d5, d6 │ │ │ │ vdiv.f64 d7, d4, d6 │ │ │ │ vstr d3, [r3, #24] │ │ │ │ vstr d2, [r3, #200] @ 0xc8 │ │ │ │ vstr d7, [r3, #216] @ 0xd8 │ │ │ │ mvnle r3, r4, lsr fp │ │ │ │ subseq pc, r8, r4, lsl #2 │ │ │ │ - blx 134661e <__bss_end__@@Base+0x129f9e6> │ │ │ │ - blmi 25ce48 <__bss_end__@@Base+0x1b6210> │ │ │ │ + blx ff7464e6 <__bss_end__@@Base+0xff69f946> │ │ │ │ + blmi 25cd10 <__bss_end__@@Base+0x1b6170> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls a64690 <__bss_end__@@Base+0x9bda58> │ │ │ │ + blls a64558 <__bss_end__@@Base+0x9bd9b8> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, LR_abt │ │ │ │ ldc 0, cr11, [sp], #168 @ 0xa8 │ │ │ │ pop {r1, r8, r9, fp, pc} │ │ │ │ @ instruction: 0xf7f881f0 │ │ │ │ - svclt 0x0000eec0 │ │ │ │ - andeq sp, r4, r0, lsr #23 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq sp, r4, r0, ror #19 │ │ │ │ + svclt 0x0000ef38 │ │ │ │ + ldrdeq sp, [r4], -r8 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq sp, r4, r8, lsl fp │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi c5b0c <__bss_end__@@Base+0x1eed4> │ │ │ │ + blhi c59d4 <__bss_end__@@Base+0x1ee34> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00c8f8cc │ │ │ │ stmdbmi lr!, {r3, r7, r9, sl, lr} │ │ │ │ - bmi b9bec0 <__bss_end__@@Base+0xaf5288> │ │ │ │ + bmi b9bd88 <__bss_end__@@Base+0xaf51e8> │ │ │ │ @ instruction: 0x46054479 │ │ │ │ stmdami sp!, {r0, r1, r2, r3, r4, r9, sl, lr} │ │ │ │ addlt r4, r6, sp, lsr #22 │ │ │ │ ldrbtmi r5, [r8], #-2186 @ 0xfffff776 │ │ │ │ cmncs ip, fp, ror r4 │ │ │ │ andls r6, r5, #1179648 @ 0x120000 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ adcvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ - blhi 104614c <__bss_end__@@Base+0xf9f514> │ │ │ │ - @ instruction: 0xf9aef009 │ │ │ │ + blhi 1046014 <__bss_end__@@Base+0xf9f474> │ │ │ │ + blx fedc657c <__bss_end__@@Base+0xfed1f9dc> │ │ │ │ movwcs r4, #13828 @ 0x3604 │ │ │ │ stmdbge r1, {r0, r2, sp, lr} │ │ │ │ strvs r4, [r3, #-1576]! @ 0xfffff9d8 │ │ │ │ andhi pc, r4, r4, asr #17 │ │ │ │ - @ instruction: 0xff0ef008 │ │ │ │ - bvc 85e1c <__bss_start@@Base+0x2ad7c> │ │ │ │ - bvs 105e20 <__bss_end__@@Base+0x5f1e8> │ │ │ │ - ldc 6, cr4, [pc, #232] @ a798 │ │ │ │ + @ instruction: 0xf8e0f009 │ │ │ │ + bvc 85ce4 <__bss_start@@Base+0x2acdc> │ │ │ │ + bvs 105ce8 <__bss_end__@@Base+0x5f148> │ │ │ │ + ldc 6, cr4, [pc, #232] @ a660 │ │ │ │ vmov.32 r5, d0[1] │ │ │ │ vcvt.f64.u32 d0, s16 │ │ │ │ vldr d23, [sp, #924] @ 0x39c │ │ │ │ vmov.f32 s8, #132 @ 0xc0200000 -2.5 │ │ │ │ ldrtmi r6, [r1], -r6, ror #23 │ │ │ │ cdp 6, 11, cr4, cr8, cr0, {1} │ │ │ │ vnmul.f64 d4, d23, d20 │ │ │ │ @@ -7215,96 +7163,96 @@ │ │ │ │ vldr d22, [sp, #20] │ │ │ │ vmov.f32 s10, #130 @ 0xc0100000 -2.250 │ │ │ │ @ instruction: 0xee865be5 │ │ │ │ vdiv.f64 d3, d7, d4 │ │ │ │ vstr d6, [r4, #20] │ │ │ │ vstr d3, [r4, #40] @ 0x28 │ │ │ │ @ instruction: 0xf7ff6b0c │ │ │ │ - bmi 40a19c <__bss_end__@@Base+0x363564> │ │ │ │ + bmi 40a064 <__bss_end__@@Base+0x3634c4> │ │ │ │ ldrbtmi r4, [sl], #-2827 @ 0xfffff4f5 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r5, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ strtmi sp, [r0], -r5, lsl #2 │ │ │ │ ldc 0, cr11, [sp], #24 │ │ │ │ pop {r1, r8, r9, fp, pc} │ │ │ │ @ instruction: 0xf7f881f0 │ │ │ │ - svclt 0x0000ee56 │ │ │ │ + svclt 0x0000eece │ │ │ │ andeq r0, r0, r0 │ │ │ │ addmi r4, pc, r0 │ │ │ │ - muleq r4, r8, r9 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - @ instruction: 0x0003f9be │ │ │ │ + ldrdeq sp, [r4], -r0 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq pc, r3, r6, ror #20 │ │ │ │ @ instruction: 0xfffff7e1 │ │ │ │ - andeq sp, r4, lr, lsl #18 │ │ │ │ + andeq sp, r4, r6, asr #20 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb6d344 <__bss_end__@@Base+0xfeac670c> │ │ │ │ + bl feb6d20c <__bss_end__@@Base+0xfeac666c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf8d00fe8 │ │ │ │ mrc 0, 5, r3, cr0, cr8, {6} │ │ │ │ strmi r8, [r4], -r0, asr #22 │ │ │ │ ldrmi r4, [r6], -sp, lsl #12 │ │ │ │ - bvs 636c20 <__bss_end__@@Base+0x58ffe8> │ │ │ │ - @ instruction: 0xf9faf009 │ │ │ │ + bvs 636ae8 <__bss_end__@@Base+0x58ff48> │ │ │ │ + blx c6646 <__bss_end__@@Base+0x1faa6> │ │ │ │ ldrsbeq pc, [r8], #132 @ 0x84 @ │ │ │ │ - @ instruction: 0xf9f6f009 │ │ │ │ - bleq 1246224 <__bss_end__@@Base+0x119f5ec> │ │ │ │ + blx fffc664c <__bss_end__@@Base+0xfff1faac> │ │ │ │ + bleq 12460ec <__bss_end__@@Base+0x119f54c> │ │ │ │ ldc 6, cr4, [sp], #200 @ 0xc8 │ │ │ │ strtmi r8, [r9], -r2, lsl #22 │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xe6674070 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb6197c <__bss_end__@@Base+0xfeabad44> │ │ │ │ + bl feb61844 <__bss_end__@@Base+0xfeabaca4> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf8df0fe0 │ │ │ │ addlt ip, r5, r4, asr #32 │ │ │ │ @ instruction: 0x46044b10 │ │ │ │ stcge 4, cr4, [r1, #-1008] @ 0xfffffc10 │ │ │ │ andcc r4, r8, sl, lsr #12 │ │ │ │ andcc pc, r3, ip, asr r8 @ │ │ │ │ movwls r6, #14363 @ 0x381b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - @ instruction: 0xf9e2f7fa │ │ │ │ + blx 12c8654 <__bss_end__@@Base+0x1221ab4> │ │ │ │ strtmi r6, [r9], -r0, ror #16 │ │ │ │ - blx 548796 <__bss_end__@@Base+0x4a1b5e> │ │ │ │ - blmi 1dcfd0 <__bss_end__@@Base+0x136398> │ │ │ │ + blx 1f4865e <__bss_end__@@Base+0x1ea1abe> │ │ │ │ + blmi 1dce98 <__bss_end__@@Base+0x1362f8> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls e4820 <__bss_end__@@Base+0x3dbe8> │ │ │ │ + blls e46e8 <__bss_end__@@Base+0x3db48> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, SP_irq │ │ │ │ ldclt 0, cr11, [r0, #-20]! @ 0xffffffec │ │ │ │ - ldcl 7, cr15, [sl, #992]! @ 0x3e0 │ │ │ │ - andeq sp, r4, r4, ror r8 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq sp, r4, r0, asr r8 │ │ │ │ + mrc 7, 3, APSR_nzcv, cr2, cr8, {7} │ │ │ │ + andeq sp, r4, ip, lsr #19 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq sp, r4, r8, lsl #19 │ │ │ │ @ instruction: 0xf7fa6840 │ │ │ │ - svclt 0x0000bb8b │ │ │ │ + svclt 0x0000bbf3 │ │ │ │ @ instruction: 0xf7fa6840 │ │ │ │ - svclt 0x0000bac5 │ │ │ │ - blpl 145e2c <__bss_end__@@Base+0x9f1f4> │ │ │ │ - blpl ff0462c0 <__bss_end__@@Base+0xfef9f688> │ │ │ │ - blx 4463b4 <__bss_end__@@Base+0x39f77c> │ │ │ │ + svclt 0x0000bb2d │ │ │ │ + blpl 145cf4 <__bss_end__@@Base+0x9f154> │ │ │ │ + blpl ff046188 <__bss_end__@@Base+0xfef9f5e8> │ │ │ │ + blx 44627c <__bss_end__@@Base+0x39f6dc> │ │ │ │ @ instruction: 0xed90d925 │ │ │ │ vldr d7, [r1, #56] @ 0x38 │ │ │ │ vldr d3, [r1] │ │ │ │ vldr d6, [r0, #8] │ │ │ │ vmov.32 d7[1], r4 │ │ │ │ strlt r7, [r0, #-2819] @ 0xfffff4fd │ │ │ │ strht pc, [r0], -r0 @ │ │ │ │ - blmi 1c60a0 <__bss_end__@@Base+0x11f468> │ │ │ │ + blmi 1c5f68 <__bss_end__@@Base+0x11f3c8> │ │ │ │ strhtgt pc, [r2], -r0 @ │ │ │ │ cdp 0, 8, cr2, cr7, cr1, {0} │ │ │ │ vdiv.f64 d6, d4, d5 │ │ │ │ vmov.f64 d23, #213 @ 0xbea80000 -0.3281250 │ │ │ │ vcvt.s32.f64 s13, d6 │ │ │ │ vnmla.f64 d7, d22, d7 │ │ │ │ ldrbtmi r1, [r1], #-2704 @ 0xfffff570 │ │ │ │ andsvs r1, r1, r9, lsl #1 │ │ │ │ - bcs fe446090 <__bss_end__@@Base+0xfe39f458> │ │ │ │ + bcs fe445f58 <__bss_end__@@Base+0xfe39f3b8> │ │ │ │ addsne r4, r2, r2, ror #8 │ │ │ │ @ instruction: 0xf85d601a │ │ │ │ andcs pc, r0, r4, lsl #22 │ │ │ │ svclt 0x00004770 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ @@ -7320,1264 +7268,1819 @@ │ │ │ │ stc 3, cr0, [r7] │ │ │ │ vstr d4, [sp, #8] │ │ │ │ vstr d0, [sp, #24] │ │ │ │ vstr d1, [sp, #32] │ │ │ │ vstr d2, [r7, #40] @ 0x28 │ │ │ │ vstr d3, [r7] │ │ │ │ @ instruction: 0xf0005b04 │ │ │ │ - vldr s30, [sp, #68] @ 0x44 │ │ │ │ + vldr s30, [sp, #644] @ 0x284 │ │ │ │ strbmi r5, [r2], -r6, lsl #22 │ │ │ │ - blvs 245f10 <__bss_end__@@Base+0x19f2d8> │ │ │ │ + blvs 245dd8 <__bss_end__@@Base+0x19f238> │ │ │ │ ldc 6, cr4, [sp, #164] @ 0xa4 │ │ │ │ ldrtmi r7, [r8], -sl, lsl #22 │ │ │ │ - blpl 118636c <__bss_end__@@Base+0x10df734> │ │ │ │ - blvs 11c6370 <__bss_end__@@Base+0x111f738> │ │ │ │ - blvc 1206374 <__bss_end__@@Base+0x115f73c> │ │ │ │ - blpl 745ecc <__bss_end__@@Base+0x69f294> │ │ │ │ - blvs 945ed0 <__bss_end__@@Base+0x89f298> │ │ │ │ - blvc b45ed4 <__bss_end__@@Base+0xa9f29c> │ │ │ │ - ldc2l 0, cr15, [r4], {0} │ │ │ │ + blpl 1186234 <__bss_end__@@Base+0x10df694> │ │ │ │ + blvs 11c6238 <__bss_end__@@Base+0x111f698> │ │ │ │ + blvc 120623c <__bss_end__@@Base+0x115f69c> │ │ │ │ + blpl 745d94 <__bss_end__@@Base+0x69f1f4> │ │ │ │ + blvs 945d98 <__bss_end__@@Base+0x89f1f8> │ │ │ │ + blvc b45d9c <__bss_end__@@Base+0xa9f1fc> │ │ │ │ + cdp2 0, 0, cr15, cr8, cr0, {0} │ │ │ │ @ instruction: 0xf0004620 │ │ │ │ - @ instruction: 0xed9df9f7 │ │ │ │ + vldr s30, [sp, #540] @ 0x21c │ │ │ │ vldr d6, [sp, #56] @ 0x38 │ │ │ │ vmul.f64 d5, d6, d12 │ │ │ │ vmla.f64 d7, d5, d6 │ │ │ │ vmov.f64 d7, #21 @ 0x40a80000 5.250 │ │ │ │ vcmpe.f64 d4, #0.0 │ │ │ │ vsqrt.f64 d20, d0 │ │ │ │ svclt 0x00d8fa10 │ │ │ │ stmiaeq r0!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ mcr 13, 4, sp, cr5, cr9, {0} │ │ │ │ @ instruction: 0xf10d7b04 │ │ │ │ cdp 8, 8, cr0, cr6, cr0, {7} │ │ │ │ addcs r5, r0, #4, 22 @ 0x1000 │ │ │ │ strbmi r4, [r0], -r9, lsr #12 │ │ │ │ - blvs 12063c4 <__bss_end__@@Base+0x115f78c> │ │ │ │ - blvc 245f14 <__bss_end__@@Base+0x19f2dc> │ │ │ │ - blpl 2c5f18 <__bss_end__@@Base+0x21f2e0> │ │ │ │ - blpl 45f1c │ │ │ │ - blvs c5f20 <__bss_end__@@Base+0x1f2e8> │ │ │ │ - stc 7, cr15, [ip], {248} @ 0xf8 │ │ │ │ + blvs 120628c <__bss_end__@@Base+0x115f6ec> │ │ │ │ + blvc 245ddc <__bss_end__@@Base+0x19f23c> │ │ │ │ + blpl 2c5de0 <__bss_end__@@Base+0x21f240> │ │ │ │ + blpl 45de4 │ │ │ │ + blvs c5de8 <__bss_end__@@Base+0x1f248> │ │ │ │ + stc 7, cr15, [r4, #-992] @ 0xfffffc20 │ │ │ │ strtmi r4, [r1], -sl, lsr #12 │ │ │ │ @ instruction: 0xf0004640 │ │ │ │ - mrcge 10, 0, APSR_nzcv, cr2, cr15, {0} │ │ │ │ + vnmlage.f32 s30, s5, s2 │ │ │ │ @ instruction: 0x46324638 │ │ │ │ @ instruction: 0xf0004629 │ │ │ │ - @ instruction: 0x4620fc9f │ │ │ │ - @ instruction: 0xf9c2f000 │ │ │ │ - blvc 145f8c <__bss_end__@@Base+0x9f354> │ │ │ │ - blpl c5f90 <__bss_end__@@Base+0x1f358> │ │ │ │ - blvs 2061d8 <__bss_end__@@Base+0x15f5a0> │ │ │ │ - blvs 186154 <__bss_end__@@Base+0xdf51c> │ │ │ │ - blmi ff1c6408 <__bss_end__@@Base+0xff11f7d0> │ │ │ │ - blmi ff04641c <__bss_end__@@Base+0xfef9f7e4> │ │ │ │ - blx 446510 <__bss_end__@@Base+0x39f8d8> │ │ │ │ + @ instruction: 0x4620fdd3 │ │ │ │ + blx 14c67f8 <__bss_end__@@Base+0x141fc58> │ │ │ │ + blvc 145e54 <__bss_end__@@Base+0x9f2b4> │ │ │ │ + blpl c5e58 <__bss_end__@@Base+0x1f2b8> │ │ │ │ + blvs 2060a0 <__bss_end__@@Base+0x15f500> │ │ │ │ + blvs 18601c <__bss_end__@@Base+0xdf47c> │ │ │ │ + blmi ff1c62d0 <__bss_end__@@Base+0xff11f730> │ │ │ │ + blmi ff0462e4 <__bss_end__@@Base+0xfef9f744> │ │ │ │ + blx 4463d8 <__bss_end__@@Base+0x39f838> │ │ │ │ mrc 13, 5, sp, cr1, cr9, {0} │ │ │ │ addcs r7, r0, #72704 @ 0x11c00 │ │ │ │ - blcc 14636c <__bss_end__@@Base+0x9f734> │ │ │ │ + blcc 146234 <__bss_end__@@Base+0x9f694> │ │ │ │ strbmi r4, [r0], -r9, lsr #12 │ │ │ │ - blvs 14637c <__bss_end__@@Base+0x9f744> │ │ │ │ - blcc 545f74 <__bss_end__@@Base+0x49f33c> │ │ │ │ - blcc 2c5f78 <__bss_end__@@Base+0x21f340> │ │ │ │ - blvc 11c6430 <__bss_end__@@Base+0x111f7f8> │ │ │ │ - blvs 4c5f80 <__bss_end__@@Base+0x41f348> │ │ │ │ - blvc 345f84 <__bss_end__@@Base+0x29f34c> │ │ │ │ - mrrc 7, 15, pc, sl, cr8 @ │ │ │ │ + blvs 146244 <__bss_end__@@Base+0x9f6a4> │ │ │ │ + blcc 545e3c <__bss_end__@@Base+0x49f29c> │ │ │ │ + blcc 2c5e40 <__bss_end__@@Base+0x21f2a0> │ │ │ │ + blvc 11c62f8 <__bss_end__@@Base+0x111f758> │ │ │ │ + blvs 4c5e48 <__bss_end__@@Base+0x41f2a8> │ │ │ │ + blvc 345e4c <__bss_end__@@Base+0x29f2ac> │ │ │ │ + ldcl 7, cr15, [r2], {248} @ 0xf8 │ │ │ │ strtmi r4, [r1], -sl, lsr #12 │ │ │ │ @ instruction: 0xf0004640 │ │ │ │ - ldrtmi pc, [r2], -sp, ror #19 @ │ │ │ │ + ldrtmi pc, [r2], -pc, lsl #21 @ │ │ │ │ stmdage r0!, {r0, r3, r5, r9, sl, lr}^ │ │ │ │ - stc2l 0, cr15, [lr], #-0 │ │ │ │ + stc2 0, cr15, [r2] │ │ │ │ @ instruction: 0xf0004620 │ │ │ │ - @ instruction: 0xed96f991 │ │ │ │ + vldr s30, [r6, #132] @ 0x84 │ │ │ │ vldr d6, [r6, #16] │ │ │ │ vldr d4, [r6, #8] │ │ │ │ vmul.f64 d5, d6, d0 │ │ │ │ vmla.f64 d7, d4, d6 │ │ │ │ vmov.f64 d7, #20 @ 0x40a00000 5.0 │ │ │ │ vnmul.f64 d4, d20, d7 │ │ │ │ vmla.f64 d7, d5, d4 │ │ │ │ vmov.f64 d7, #21 @ 0x40a80000 5.250 │ │ │ │ vcmpe.f64 d3, #0.0 │ │ │ │ vsqrt.f64 d19, d0 │ │ │ │ vldrle s30, [lr, #-64] @ 0xffffffc0 │ │ │ │ - blvc 1063d4 <__bss_end__@@Base+0x5f79c> │ │ │ │ - blvs ff04649c <__bss_end__@@Base+0xfef9f864> │ │ │ │ - blmi 1063e0 <__bss_end__@@Base+0x5f7a8> │ │ │ │ + blvc 10629c <__bss_end__@@Base+0x5f6fc> │ │ │ │ + blvs ff046364 <__bss_end__@@Base+0xfef9f7c4> │ │ │ │ + blmi 1062a8 <__bss_end__@@Base+0x5f708> │ │ │ │ strtmi r2, [r9], -r0, lsl #5 │ │ │ │ cdp 6, 15, cr4, cr1, cr0, {2} │ │ │ │ svclt 0x0048fa10 │ │ │ │ - blvc 12064a0 <__bss_end__@@Base+0x115f868> │ │ │ │ - blvs 11464a4 <__bss_end__@@Base+0x109f86c> │ │ │ │ - blmi 445ff4 <__bss_end__@@Base+0x39f3bc> │ │ │ │ - blvc 545ff8 <__bss_end__@@Base+0x49f3c0> │ │ │ │ - blvc 45ffc │ │ │ │ - blvs 146000 <__bss_end__@@Base+0x9f3c8> │ │ │ │ - ldc 7, cr15, [ip], {248} @ 0xf8 │ │ │ │ + blvc 1206368 <__bss_end__@@Base+0x115f7c8> │ │ │ │ + blvs 114636c <__bss_end__@@Base+0x109f7cc> │ │ │ │ + blmi 445ebc <__bss_end__@@Base+0x39f31c> │ │ │ │ + blvc 545ec0 <__bss_end__@@Base+0x49f320> │ │ │ │ + blvc 45ec4 │ │ │ │ + blvs 145ec8 <__bss_end__@@Base+0x9f328> │ │ │ │ + ldc 7, cr15, [r4], {248} @ 0xf8 │ │ │ │ strtmi r4, [r1], -sl, lsr #12 │ │ │ │ @ instruction: 0xf0004640 │ │ │ │ - strtmi pc, [r0], -pc, lsr #19 │ │ │ │ - @ instruction: 0xf958f000 │ │ │ │ + @ instruction: 0x4620fa51 │ │ │ │ + @ instruction: 0xf9e8f000 │ │ │ │ movwcs r2, #512 @ 0x200 │ │ │ │ stmib r4, {r0, r3, r5, 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<__bss_end__@@Base+0x31f4c8> │ │ │ │ + blvc 3c5fc8 <__bss_end__@@Base+0x31f428> │ │ │ │ ldc 0, cr2, [sp, #4] │ │ │ │ vldr d3, [r4] │ │ │ │ vldr d4, [sp, #64] @ 0x40 │ │ │ │ vmul.f64 d6, d7, d2 │ │ │ │ @ instruction: 0xf9b47b03 │ │ │ │ @ instruction: 0xf9b42020 │ │ │ │ cdp 0, 2, cr3, cr4, cr2, {1} │ │ │ │ vdiv.f64 d4, d7, d6 │ │ │ │ vdiv.f64 d6, d4, d5 │ │ │ │ vmov.f64 d23, #213 @ 0xbea80000 -0.3281250 │ │ │ │ vcvt.s32.f64 s13, d6 │ │ │ │ vnmla.f64 d7, d22, d7 │ │ │ │ ldrmi r1, [r1], #-2704 @ 0xfffff570 │ │ │ │ - bcs fe446344 <__bss_end__@@Base+0xfe39f70c> │ │ │ │ + bcs fe44620c <__bss_end__@@Base+0xfe39f66c> │ │ │ │ eorsvs r1, r1, r9, lsl #1 │ │ │ │ addsne r4, r2, sl, lsl r4 │ │ │ │ - bmi 262b9c <__bss_end__@@Base+0x1bbf64> │ │ │ │ + bmi 262a64 <__bss_end__@@Base+0x1bbec4> │ │ │ │ ldrbtmi r4, [sl], #-2823 @ 0xfffff4f9 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r7, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andlt sp, r8, r1, lsl #2 │ │ │ │ @ instruction: 0xf7f8bd70 │ │ │ │ - svclt 0x0000ec58 │ │ │ │ - andeq sp, r4, lr, ror r5 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq sp, r4, sl, lsl #10 │ │ │ │ - bleq 46120 │ │ │ │ - blne c6124 <__bss_end__@@Base+0x1f4ec> │ │ │ │ - blcs 146128 <__bss_end__@@Base+0x9f4f0> │ │ │ │ - svclt 0x00004770 │ │ │ │ - blpl 46170 │ │ │ │ - blcs 46178 │ │ │ │ - blvs c6178 <__bss_end__@@Base+0x1f540> │ │ │ │ - blcc c6180 <__bss_end__@@Base+0x1f548> │ │ │ │ - blvc 146180 <__bss_end__@@Base+0x9f548> │ │ │ │ - blpl c6418 <__bss_end__@@Base+0x1f7e0> │ │ │ │ - blmi 14618c <__bss_end__@@Base+0x9f554> │ │ │ │ - blvs 106424 <__bss_end__@@Base+0x5f7ec> │ │ │ │ - blvc 14642c <__bss_end__@@Base+0x9f7f4> │ │ │ │ - blpl 4615c │ │ │ │ - blvs c6160 <__bss_end__@@Base+0x1f528> │ │ │ │ - blvc 146164 <__bss_end__@@Base+0x9f52c> │ │ │ │ - svclt 0x00004770 │ │ │ │ - bleq c61a4 <__bss_end__@@Base+0x1f56c> │ │ │ │ - blvs 461a8 │ │ │ │ - blvc 1461ac <__bss_end__@@Base+0x9f574> │ │ │ │ - bleq 463f0 │ │ │ │ - bleq 1c638c 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- @ instruction: 0xf85c7b05 │ │ │ │ - ldmdavs fp, {r0, r1, ip, sp} │ │ │ │ - @ instruction: 0xf04f9307 │ │ │ │ - svclt 0x000a0300 │ │ │ │ - movwcs r2, #769 @ 0x301 │ │ │ │ - stc 3, cr2, [lr, #4] │ │ │ │ - vldr d7, [r0] │ │ │ │ - vldr d5, [r1] │ │ │ │ + svclt 0x0000ecd0 │ │ │ │ + @ instruction: 0x0004d6b6 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq sp, r4, r2, asr #12 │ │ │ │ + addlt fp, r9, r0, lsl #9 │ │ │ │ + mvnsvs sl, r0, lsl #30 │ │ │ │ + bleq 14600c <__bss_end__@@Base+0x9f46c> │ │ │ │ + blne c6010 <__bss_end__@@Base+0x1f470> │ │ │ │ + blcs 46014 │ │ │ │ + ldmib r7, {r0, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ + stmib r1, {r2, r8, r9, sp}^ │ │ │ │ + ldmibvs r9!, {r8, r9, sp}^ │ │ │ │ + movwcs lr, #10711 @ 0x29d7 │ │ │ │ + movwcs lr, #10689 @ 0x29c1 │ │ │ │ + ldmib r7, {r0, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ + stmib r1, {r8, r9, sp}^ │ │ │ │ + svclt 0x00002304 │ │ │ │ + ldrtmi r3, [sp], r4, lsr #14 │ │ │ │ + blvc 148b94 <__bss_end__@@Base+0xa1ff4> │ │ │ │ + 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r4, r5, r6, sp, lr}^ │ │ │ │ + blvs 4612c │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmul.f64 d7, d6, d0 │ │ │ │ - vnmls.f64 d6, d4, d5 │ │ │ │ - vstr d6, [lr, #28] │ │ │ │ - vldr d6, [r0, #8] │ │ │ │ - vldr d4, [r1, #8] │ │ │ │ - vmul.f64 d6, d7, d2 │ │ │ │ - vnmls.f64 d7, d5, d4 │ │ │ │ - vstr d7, [lr, #24] │ │ │ │ - cmplt r3, r4, lsl #22 │ │ │ │ - ldm lr!, {r2, r4, r7, r9, sl, lr} │ │ │ │ - stmia ip!, {r0, r1, r2, r3} │ │ │ │ - ldm lr, {r0, r1, r2, r3} │ │ │ │ - stm ip, {r0, r1} │ │ │ │ - bmi 24ac98 <__bss_end__@@Base+0x1a4060> │ │ │ │ - ldrbtmi r4, [sl], #-2823 @ 0xfffff4f9 │ │ │ │ - ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ - subsmi r9, sl, r7, lsl #22 │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - andlt sp, r9, r2, lsl #2 │ │ │ │ - blx 148e1a <__bss_end__@@Base+0xa21e2> │ │ │ │ - bl fe2c8c88 <__bss_end__@@Base+0xfe222050> │ │ │ │ - ldrdeq sp, [r4], -r0 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq sp, r4, r2, ror r3 │ │ │ │ - vst3.8 {d27,d29,d31}, [pc], r8 │ │ │ │ - bl feb61ebc <__bss_end__@@Base+0xfeabb284> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - stmdbmi r3, {r3, r4, r5, r6, r7, r8, r9, sl, fp} │ │ │ │ - ldrbtmi r2, [r9], #-640 @ 0xfffffd80 │ │ │ │ - b fec48cac <__bss_end__@@Base+0xfeba2074> │ │ │ │ - svclt 0x0000bd08 │ │ │ │ - strdeq r2, [r4], -sl │ │ │ │ - vst3.8 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb61edc <__bss_end__@@Base+0xfeabb2a4> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - bmi 6cea84 <__bss_end__@@Base+0x627e4c> │ │ │ │ - blmi 6f6f74 <__bss_end__@@Base+0x65033c> │ │ │ │ - ldrbtmi r4, [sl], #-648 @ 0xfffffd78 │ │ │ │ - strbtmi fp, [ip], -ip, lsl #30 │ │ │ │ - strmi r4, [r6], ip, lsl #12 │ │ │ │ - stceq 1, cr15, [r0], #-16 │ │ │ │ - ldmpl r3, {r5, r7, sl, ip, sp}^ │ │ │ │ - @ instruction: 0x9321681b │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - msreq CPSR_, #172, 2 @ 0x2b │ │ │ │ - @ instruction: 0x46154672 │ │ │ │ - ldc 2, cr3, [r5, #128] @ 0x80 │ │ │ │ - vstmia r3!, {d7-d6} │ │ │ │ - strbmi r7, [r3, #-2818]! @ 0xfffff4fe │ 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instruction: 0xf04fbf09 │ │ │ │ - @ instruction: 0xf04f0901 │ │ │ │ - strbtmi r0, [lr], -r0, lsl #18 │ │ │ │ - stmdbeq r1, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ - svclt 0x001858d3 │ │ │ │ - @ instruction: 0x460a463e │ │ │ │ - cdpeq 1, 2, cr15, cr0, cr1, {0} │ │ │ │ - @ instruction: 0x9321681b │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - stmeq r0, {r0, r8, ip, sp, lr, pc} │ │ │ │ - streq pc, [r0, #-256]! @ 0xffffff00 │ │ │ │ - ldrtmi r4, [r4], -r1, lsl #12 │ │ │ │ - pkhbtmi r4, ip, r3, lsl #12 │ │ │ │ - blvc 646430 <__bss_end__@@Base+0x59f7f8> │ │ │ │ - ldc 6, cr4, [r3], #904 @ 0x388 │ │ │ │ - @ instruction: 0xf10c5b02 │ │ │ │ - ldc 12, cr0, [sl, #128] @ 0x80 │ │ │ │ - ldrbmi r6, [r3, #-2816]! @ 0xfffff500 │ │ │ │ - blvc 1c65dc <__bss_end__@@Base+0x11f9a4> │ │ │ │ - strdcc sp, [r8, -r4] │ │ │ │ - blvc c6060 <__bss_end__@@Base+0x1f428> │ │ │ │ - mvnle r4, r9, lsr #5 │ │ │ │ - @ instruction: 0xf1033220 │ │ │ │ - strtcc r0, [r0], -r0, lsr #28 │ │ │ │ - mvnle r4, r2, asr #10 │ │ │ │ - svceq 0x0000f1b9 │ │ │ │ - addcs sp, r0, #4 │ │ │ │ - ldrtmi r4, [r8], -r9, ror #12 │ │ │ │ - b 7c8dd0 <__bss_end__@@Base+0x722198> │ │ │ │ - blmi 2dd624 <__bss_end__@@Base+0x2369ec> │ │ │ │ - ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 864e64 <__bss_end__@@Base+0x7be22c> │ │ │ │ - @ instruction: 0xf04f405a │ │ │ │ - mrsle r0, LR_svc │ │ │ │ - pop {r1, r5, ip, sp, pc} │ │ │ │ - @ instruction: 0xf7f887f0 │ │ │ │ - svclt 0x0000ead8 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl c613c <__bss_end__@@Base+0x1f59c> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d2 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 146150 <__bss_end__@@Base+0x9f5b0> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d4 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ + strcc r0, [ip, -r7, asr #22] │ │ │ │ + @ instruction: 0xf85d46bd │ │ │ │ + ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ + addlt fp, r5, r0, lsl #9 │ │ │ │ + rscsvs sl, r8, r0, lsl #30 │ │ │ │ + ldrhtvs r6, [sl], #-9 │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, sp, lr} │ │ │ │ + blvc 46184 │ │ │ │ + blvc 1206414 <__bss_end__@@Base+0x115f874> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs c6194 <__bss_end__@@Base+0x1f5f4> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vadd.f64 d7, d6, d2 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc c6164 <__bss_end__@@Base+0x1f5c4> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, sp, lr} │ │ │ │ + blvc 1461b0 <__bss_end__@@Base+0x9f610> │ │ │ │ + blvc 1206440 <__bss_end__@@Base+0x115f8a0> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + svclt 0x00007b04 │ │ │ │ + ssatmi r3, #30, r4, lsl #14 │ │ │ │ + blvc 148cec <__bss_end__@@Base+0xa214c> │ │ │ │ + strlt r4, [r0], #1904 @ 0x770 │ │ │ │ + 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r6, sl, #8060928 @ 0x7b0000 │ │ │ │ + ldmvs sl!, {r0, r1, ip, lr, pc} │ │ │ │ + addsmi r6, sl, #8060928 @ 0x7b0000 │ │ │ │ + movwcs sp, #4357 @ 0x1105 │ │ │ │ + @ instruction: 0xf10762fb │ │ │ │ + adcsvs r0, fp, #16, 6 @ 0x40000000 │ │ │ │ + movwcs lr, #3 │ │ │ │ + ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, r9, sp, lr}^ │ │ │ │ + ldmvs fp!, {r0, r1, r3, r4, r5, r7, r9, sp, lr}^ │ │ │ │ + blvs c624c <__bss_end__@@Base+0x1f6ac> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d4 │ │ │ │ + ldmvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 14625c <__bss_end__@@Base+0x9f6bc> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d5, d2 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + bvs feee993c <__bss_end__@@Base+0xfee42d9c> │ │ │ │ + blvc 46230 │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, sp, lr} │ │ │ │ + blvc 4627c │ │ │ │ + blvs 2064cc <__bss_end__@@Base+0x15f92c> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs 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r2!, {d23-d25} │ │ │ │ - andcc r3, r8, #16777216 @ 0x1000000 │ │ │ │ - stc 2, cr4, [r5], #652 @ 0x28c │ │ │ │ - vstmiale r6!, {d23} │ │ │ │ - bleq 872dc <__bss_start@@Base+0x2c23c> │ │ │ │ - strcc r3, [r0, -r0, lsr #12]! │ │ │ │ - ldclle 5, cr4, [sp], {91} @ 0x5b │ │ │ │ - movwcs r2, #512 @ 0x200 │ │ │ │ - tstcs r6, #3293184 @ 0x324000 │ │ │ │ - movwcs lr, #59849 @ 0xe9c9 │ │ │ │ - movwcs lr, #27081 @ 0x69c9 │ │ │ │ - tstcs ip, #3293184 @ 0x324000 │ │ │ │ - tstcs sl, #3293184 @ 0x324000 │ │ │ │ - tstcs r8, #3293184 @ 0x324000 │ │ │ │ - movwcs r2, #512 @ 0x200 │ │ │ │ - mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ - tstcs lr, #3293184 @ 0x324000 │ │ │ │ - bllt f1ae8 <__bss_end__@@Base+0x4aeb0> │ │ │ │ - blmi 91d77c <__bss_end__@@Base+0x876b44> │ │ │ │ - ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 8e4f58 <__bss_end__@@Base+0x83e320> │ │ │ │ - @ instruction: 0xf04f405a │ │ │ │ - teqle r7, r0, lsl #6 │ │ │ │ - pop {r0, r2, r5, ip, sp, pc} │ │ │ │ - andcs r8, r0, #240, 30 @ 0x3c0 │ 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│ │ │ │ - stmib r8, {r1, r3, r4, r8, r9, sp}^ │ │ │ │ - @ instruction: 0xe7bd2318 │ │ │ │ - b a48f4c <__bss_end__@@Base+0x9a2314> │ │ │ │ - ... │ │ │ │ - andeq sp, r4, r0, asr #3 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq sp, r4, r8, lsl r1 │ │ │ │ - vst3. {d27,d29,d31}, [pc :256], r0 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb6db94 <__bss_end__@@Base+0xfeac6f5c> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - bmi acecb4 <__bss_end__@@Base+0xa2807c> │ │ │ │ - blmi af7234 <__bss_end__@@Base+0xa505fc> │ │ │ │ - ldrbtmi r4, [sl], #-1548 @ 0xfffff9f4 │ │ │ │ - strmi r4, [r5], -r9, ror #12 │ │ │ │ - ldmpl r3, {r1, fp, sp, pc}^ │ │ │ │ - @ instruction: 0x9325681b │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - stmda r4!, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - blge 11d448 <__bss_end__@@Base+0x76810> │ │ │ │ - addcs r4, r0, #24, 12 @ 0x1800000 │ │ │ │ - ldc 4, cr4, [sp, #484] @ 0x1e4 │ │ │ │ - ldmib sp, {r1, r8, r9, fp, pc}^ │ │ │ │ - @ instruction: 0xf7f86700 │ │ │ │ - @ instruction: 0x2c02e934 │ │ │ │ - eorle r4, fp, r3, lsl #12 │ │ │ │ - andsle r2, lr, r3, lsl #24 │ │ │ │ - tstle r9, r1, lsl #24 │ │ │ │ - blvc 1246a9c <__bss_end__@@Base+0x119fe64> │ │ │ │ - ldrvs lr, [r8, -sp, asr #19] │ │ │ │ - strvs lr, [lr, -sp, asr #19] │ │ │ │ - blhi 5c6618 <__bss_end__@@Base+0x51f9e0> │ │ │ │ - blvc 44661c <__bss_end__@@Base+0x39f9e4> │ │ │ │ - ldrmi r4, [r9], -sl, lsr #12 │ │ │ │ - @ instruction: 0xf7ff4628 │ │ │ │ - bmi 5caac8 <__bss_end__@@Base+0x523e90> │ │ │ │ - ldrbtmi r4, [sl], #-2835 @ 0xfffff4ed │ │ │ │ - ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ - subsmi r9, sl, r5, lsr #22 │ │ │ │ + adclt fp, ip, r0, lsl #11 │ │ │ │ + rscsvs sl, r8, r0, lsl #30 │ │ │ │ + ldrhtvs r6, [sl], #-9 │ │ │ │ + ldmvs sl!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ + addsmi r6, sl, #8060928 @ 0x7b0000 │ │ │ │ + ldmvs sl!, {r0, r1, ip, lr, pc} │ │ │ │ + addsmi r6, sl, #8060928 @ 0x7b0000 │ │ │ │ + movwcs sp, #4359 @ 0x1107 │ │ │ │ + addscc pc, r4, r7, asr #17 │ │ │ │ + tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ + addscc pc, r0, r7, asr #17 │ │ │ │ + movwcs lr, #5 │ │ │ │ + addscc pc, r4, r7, asr #17 │ │ │ │ + @ instruction: 0xf8c7687b │ │ │ │ + movwcs r3, #144 @ 0x90 │ │ │ │ + adccc pc, ip, r7, asr #17 │ │ │ │ + movwcs lr, #82 @ 0x52 │ │ │ │ + adccc pc, r8, r7, asr #17 │ │ │ │ + @ instruction: 0xf04fe044 │ │ │ │ + @ instruction: 0xf04f0200 │ │ │ │ + stmib r7, {r8, r9}^ │ │ │ │ + movwcs r2, #806 @ 0x326 │ │ │ │ + adccc pc, r4, r7, asr #17 │ │ │ │ + ldmvs sl!, {r1, r5, sp, lr, pc}^ │ │ │ │ + ldrdcc pc, [r4], r7 @ │ │ │ │ + @ instruction: 0xf8d70099 │ │ │ │ + strmi r3, [fp], #-168 @ 0xffffff58 │ │ │ │ + ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ + blvs 464ec │ │ │ │ + @ instruction: 0xf8d768ba │ │ │ │ + addseq r3, r9, ip, lsr #1 │ │ │ │ + ldrdcc pc, [r4], r7 @ │ │ │ │ + sbcseq r4, fp, fp, lsl #8 │ │ │ │ + ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ + vmul.f64 d7, d6, d0 │ │ │ │ + vldr d7, [r7, #28] │ │ │ │ + vadd.f64 d6, d6, d22 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + @ instruction: 0xf8d77b26 │ │ │ │ + movwcc r3, #4260 @ 0x10a4 │ │ │ │ + adccc pc, r4, r7, asr #17 │ │ │ │ + ldrdcs pc, [r4], r7 @ │ │ │ │ + addsmi r6, sl, #3866624 @ 0x3b0000 │ │ │ │ + @ instruction: 0xf8d7dbd7 │ │ │ │ + @ instruction: 0xf8d72090 │ │ │ │ + addseq r3, r9, ip, lsr #1 │ │ │ │ + ldrdcc pc, [r8], r7 @ │ │ │ │ + sbcseq r4, fp, fp, lsl #8 │ │ │ │ + ldmib r7, {r0, r4, r6, r7, fp, ip}^ │ │ │ │ + stmib r1, {r1, r2, r5, r8, r9, sp}^ │ │ │ │ + @ instruction: 0xf8d72300 │ │ │ │ + movwcc r3, #4264 @ 0x10a8 │ │ │ │ + adccc pc, r8, r7, asr #17 │ │ │ │ + ldrdcs pc, [r8], r7 @ │ │ │ │ + addsmi r6, sl, #3866624 @ 0x3b0000 │ │ │ │ + @ instruction: 0xf8d7dbb5 │ │ │ │ + movwcc r3, #4268 @ 0x10ac │ │ │ │ + adccc pc, ip, r7, asr #17 │ │ │ │ + ldrdcs pc, [ip], r7 @ │ │ │ │ + addsmi r6, sl, #3866624 @ 0x3b0000 │ │ │ │ + @ instruction: 0xf8d7dba7 │ │ │ │ + @ instruction: 0xf04f1090 │ │ │ │ + @ instruction: 0xf04f0200 │ │ │ │ + stmib r1, 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<__bss_end__@@Base+0x89fb80> │ │ │ │ + blvc c46724 <__bss_end__@@Base+0xb9fb84> │ │ │ │ + blvc 206964 <__bss_end__@@Base+0x15fdc4> │ │ │ │ + blvc 9466ec <__bss_end__@@Base+0x89fb4c> │ │ │ │ + blvs 9c6730 <__bss_end__@@Base+0x91fb90> │ │ │ │ + blvc c46734 <__bss_end__@@Base+0xb9fb94> │ │ │ │ + blvc 206974 <__bss_end__@@Base+0x15fdd4> │ │ │ │ + blvc 9c66fc <__bss_end__@@Base+0x91fb5c> │ │ │ │ + blvs a46740 <__bss_end__@@Base+0x99fba0> │ │ │ │ + blvc c46744 <__bss_end__@@Base+0xb9fba4> │ │ │ │ + blvc 206984 <__bss_end__@@Base+0x15fde4> │ │ │ │ + blvc a4670c <__bss_end__@@Base+0x99fb6c> │ │ │ │ + bleq 46750 │ │ │ │ + stmda sl!, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + bleq bc6718 <__bss_end__@@Base+0xb1fb78> │ │ │ │ + blvs 46bdc │ │ │ │ + blvc bc6760 <__bss_end__@@Base+0xb1fbc0> │ │ │ │ + blvc 12069e0 <__bss_end__@@Base+0x115fe40> │ │ │ │ + blvc b46728 <__bss_end__@@Base+0xa9fb88> │ │ │ │ + bleq 4676c │ │ │ │ + stmib r8!, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} 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#-1020]! @ 0xfffffc04 │ │ │ │ + strbcc fp, [r8, r0, lsl #30] │ │ │ │ + ldclt 6, cr4, [r0, #756]! @ 0x2f4 │ │ │ │ + adclt fp, r8, r0, lsl #11 │ │ │ │ + mvnsvs sl, r0, lsl #30 │ │ │ │ + bleq 1468b0 <__bss_end__@@Base+0x9fd10> │ │ │ │ + blne c68b4 <__bss_end__@@Base+0x1fd14> │ │ │ │ + blcs 468b8 │ │ │ │ + msreq CPSR_, #-1073741823 @ 0xc0000001 │ │ │ │ + @ instruction: 0xf7ff4618 │ │ │ │ + ldmib r7, {r0, r1, r3, r4, r5, r6, r7, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + stmib r7, {r2, r8, r9, sp}^ │ │ │ │ + ldmib r7, {r3, r8, r9, sp}^ │ │ │ │ + stmib r7, {r1, r8, r9, sp}^ │ │ │ │ + ldmib r7, {r1, r4, r8, r9, sp}^ │ │ │ │ + stmib r7, {r8, r9, sp}^ │ │ │ │ + @ instruction: 0xf107231c │ │ │ │ + ldmibvs sl!, {r5, r8, r9}^ │ │ │ │ + ldmibvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ + stc2l 7, cr15, [lr, #-1020] @ 0xfffffc04 │ │ │ │ + strcc fp, [r0, r0, lsl #30]! │ │ │ │ + stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ + addlt fp, r9, r0, lsl #9 │ │ │ │ + mvnsvs sl, r0, lsl #30 │ │ │ │ + blpl 1046da0 <__bss_end__@@Base+0xfa0200> │ │ │ │ + blvs 1086da4 <__bss_end__@@Base+0xfe0204> │ │ │ │ + blvc 10c6da8 <__bss_end__@@Base+0x1020208> │ │ │ │ + blpl 46908 │ │ │ │ + blvs c690c <__bss_end__@@Base+0x1fd6c> │ │ │ │ + blvc 146910 <__bss_end__@@Base+0x9fd70> │ │ │ │ + @ instruction: 0xed9369fb │ │ │ │ + vldr d6, [r7, #24] │ │ │ │ + vadd.f64 d7, d6, d0 │ │ │ │ + ldmibvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 1c6914 <__bss_end__@@Base+0x11fd74> │ │ │ │ + @ instruction: 0xed9369fb │ │ │ │ + vldr d6, [r7, #56] @ 0x38 │ │ │ │ + vadd.f64 d7, d6, d2 │ │ │ │ + ldmibvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 3c6928 <__bss_end__@@Base+0x31fd88> │ │ │ │ + @ instruction: 0xed9369fb │ │ │ │ + vldr d6, [r7, #88] @ 0x58 │ │ │ │ + vadd.f64 d7, d6, d4 │ │ │ │ + ldmibvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 5c693c <__bss_end__@@Base+0x51fd9c> │ │ │ │ + strcc fp, [r4, -r0, lsl #30]! │ │ │ │ + @ instruction: 0xf85d46bd │ │ │ │ + ldrbmi r7, [r0, -r4, lsl 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sl, r8, r0, lsl #30 │ │ │ │ + ldrhtvs r6, [sl], #-9 │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, sp, lr} │ │ │ │ + blvc 469fc │ │ │ │ + blvs 206c4c <__bss_end__@@Base+0x1600ac> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r1, r8, r9, fp, ip, lr} │ │ │ │ + blvc c6a0c <__bss_end__@@Base+0x1fe6c> │ │ │ │ + blvc 206c58 <__bss_end__@@Base+0x1600b8> │ │ │ │ + blvs 206ca0 <__bss_end__@@Base+0x160100> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, ip, lr} │ │ │ │ + blvc 146a20 <__bss_end__@@Base+0x9fe80> │ │ │ │ + blvc 206c6c <__bss_end__@@Base+0x1600cc> │ │ │ │ + blvs 206cb4 <__bss_end__@@Base+0x160114> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vadd.f64 d7, d6, d6 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 46a3c │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d8 │ │ │ │ + ldmvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 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ip, sp, lr}^ │ │ │ │ + blvc 46b20 │ │ │ │ + blvs 146b74 <__bss_end__@@Base+0x9ffd4> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d2 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + ldmvs fp!, {r1, r2, r8, r9, fp, ip, lr} │ │ │ │ + blvc 2c6b78 <__bss_end__@@Base+0x21ffd8> │ │ │ │ + blvc 206dc4 <__bss_end__@@Base+0x160224> │ │ │ │ + blvs 206e0c <__bss_end__@@Base+0x16026c> │ │ │ │ + blpl 246b94 <__bss_end__@@Base+0x19fff4> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmov.32 d5[1], r7 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc c6b58 <__bss_end__@@Base+0x1ffb8> │ │ │ │ + blvs 146bac <__bss_end__@@Base+0xa000c> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d4 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + ldmvs fp!, {r1, r2, r8, r9, fp, ip, lr} │ │ │ │ + blvc 346bb0 <__bss_end__@@Base+0x2a0010> │ │ │ │ + blvc 206dfc <__bss_end__@@Base+0x16025c> │ │ │ │ + blvs 206e44 <__bss_end__@@Base+0x1602a4> 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+ ldc 7, cr15, [r4, #-988] @ 0xfffffc24 │ │ │ │ + bleq 246dc4 <__bss_end__@@Base+0x1a0224> │ │ │ │ + blvs 346e08 <__bss_end__@@Base+0x2a0268> │ │ │ │ + blvc 246e0c <__bss_end__@@Base+0x1a026c> │ │ │ │ + blvc 20704c <__bss_end__@@Base+0x1604ac> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7] │ │ │ │ + vldr d6, [r7, #72] @ 0x48 │ │ │ │ + vmul.f64 d7, d6, d14 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d8 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vldr d5, [r7, #64] @ 0x40 │ │ │ │ + vmul.f64 d7, d5, d10 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc c6df0 <__bss_end__@@Base+0x20250> │ │ │ │ + blvs 446e44 <__bss_end__@@Base+0x3a02a4> │ │ │ │ + blvc 3c6e48 <__bss_end__@@Base+0x3202a8> │ │ │ │ + blvs 207088 <__bss_end__@@Base+0x1604e8> │ │ │ │ + blvc 246e50 <__bss_end__@@Base+0x1a02b0> │ │ │ │ + blvs 207090 <__bss_end__@@Base+0x1604f0> │ │ │ │ + blpl 4c6e58 <__bss_end__@@Base+0x4202b8> │ │ │ │ + blvc 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sp}^ │ │ │ │ + andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - svc 0x00faf7f7 │ │ │ │ - blls c66d8 <__bss_end__@@Base+0x1faa0> │ │ │ │ - vldr d10, [r4, #16] │ │ │ │ - ldrmi sl, [r8], -r0, lsl #22 │ │ │ │ - blvs 1466e4 <__bss_end__@@Base+0x9faac> │ │ │ │ - cdp 2, 2, cr2, cr9, cr0, {4} │ │ │ │ - vldr d7, [sp, #36] @ 0x24 │ │ │ │ - vmla.f64 d12, d10, d0 │ │ │ │ - ldmdbmi r6!, {r1, r3, r8, r9, fp, ip, sp, lr} │ │ │ │ - blle c671c <__bss_end__@@Base+0x1fae4> │ │ │ │ - mcr 4, 0, r4, cr6, cr9, {3} │ │ │ │ - vmov.f64 d7, #22 @ 0x40b00000 5.5 │ │ │ │ - @ instruction: 0xee8b5bc7 │ │ │ │ - vadd.f64 d8, d11, d5 │ │ │ │ - vnmul.f64 d11, d10, d12 │ │ │ │ - vmul.f64 d10, d9, d8 │ │ │ │ - vmul.f64 d9, d8, d8 │ │ │ │ - @ instruction: 0xf7f88b06 │ │ │ │ - mrc 8, 5, lr, cr0, cr2, {5} │ │ │ │ - strtmi r6, [sl], -ip, asr #22 │ │ │ │ - strtmi r4, [r8], -r1, lsl #12 │ │ │ │ - blpl 2c6980 <__bss_end__@@Base+0x21fd48> │ │ │ │ - blmi 286980 <__bss_end__@@Base+0x1dfd48> │ │ │ │ - blvc 286988 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andeq ip, r4, r8, lsr #29 │ │ │ │ - vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb6dda8 <__bss_end__@@Base+0xfeac7170> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - @ instruction: 0xf8df0f58 │ │ │ │ - adclt lr, r2, ip, rrx │ │ │ │ - ldrdgt pc, [r8], #-143 @ 0xffffff71 @ │ │ │ │ - blge 1046c64 <__bss_end__@@Base+0xfa002c> │ │ │ │ - mrc 4, 5, r4, cr0, cr14, {7} │ │ │ │ - vmov.f64 d9, d1 │ │ │ │ - ldmdbmi r7, {r1, r6, r8, r9, fp, pc} │ │ │ │ - strmi r4, [r4], -fp, ror #12 │ │ │ │ - andgt pc, ip, lr, asr r8 @ │ │ │ │ - ldrbtmi r4, [r9], #-1560 @ 0xfffff9e8 │ │ │ │ - @ instruction: 0xf8dc2280 │ │ │ │ - @ instruction: 0xf8cdc000 │ │ │ │ - @ instruction: 0xf04fc084 │ │ │ │ - @ instruction: 0xf7f80c00 │ │ │ │ - @ instruction: 0x4622e830 │ │ │ │ - strtmi r4, [r0], -r1, lsl #12 │ │ │ │ - blge 4680c │ │ │ │ - blls 2c6810 <__bss_end__@@Base+0x21fbd8> │ │ │ │ - blhi 546814 <__bss_end__@@Base+0x49fbdc> │ │ │ │ - ldc2 7, cr15, [ip, #1020]! @ 0x3fc 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:256], r8 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb6e134 <__bss_end__@@Base+0xfeac74fc> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - vldr , [r0, #384] @ 0x180 │ │ │ │ - @ instruction: 0x46048b10 │ │ │ │ - blne 46b7c │ │ │ │ - ldc 6, cr4, [r0, #116] @ 0x74 │ │ │ │ - strmi r0, [lr], -r8, lsl #22 │ │ │ │ - mrc 6, 5, r4, cr1, cr7, {0} │ │ │ │ - @ instruction: 0xf7f78b48 │ │ │ │ - mrc 15, 5, lr, cr0, cr4, {2} │ │ │ │ - vmov.f64 d7, d0 │ │ │ │ - vstr d0, [r5, #288] @ 0x120 │ │ │ │ - @ instruction: 0xf7f77b00 │ │ │ │ - stc 13, cr14, [r7, #56] @ 0x38 │ │ │ │ - vldr d0, [r4] │ │ │ │ - vldr d1, [r4, #80] @ 0x50 │ │ │ │ - @ instruction: 0xf7f70b12 │ │ │ │ - stc 15, cr14, [r6, #272] @ 0x110 │ │ │ │ - vldr d0, [r5] │ │ │ │ - vmov.f64 d7, #80 @ 0x3e800000 0.250 │ │ │ │ - vsqrt.f64 d23, d0 │ │ │ │ - strle pc, [r5, #-2576] @ 0xfffff5f0 │ │ │ │ - blvs 146c00 <__bss_end__@@Base+0x9ffc8> │ │ │ │ - blvc 1c6e64 <__bss_end__@@Base+0x12022c> │ │ │ │ - blvc 46ba0 │ │ │ │ - blhi c6884 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fp!, {r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 46f68 │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r1, r4, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 546fb4 <__bss_end__@@Base+0x4a0414> │ │ │ │ + blne 11c742c <__bss_end__@@Base+0x112088c> │ │ │ │ + bleq 1207430 <__bss_end__@@Base+0x1160890> │ │ │ │ + ldc 7, cr15, [r4, #-988] @ 0xfffffc24 │ │ │ │ + blvc 1047438 <__bss_end__@@Base+0xfa0898> │ │ │ │ + stc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + ldmdavs fp!, {r8, r9, fp, ip, sp, lr} │ │ │ │ + blvc 46fd0 │ │ │ │ + blvc ff04745c <__bss_end__@@Base+0xfefa08bc> │ │ │ │ + blx 447550 <__bss_end__@@Base+0x3a09b0> │ │ │ │ + and sp, r9, r0, lsl #8 │ │ │ │ + ldc 8, cr6, [r3, #236] @ 0xec │ │ │ │ + vldr d7, [pc] @ b998 │ │ │ │ + vadd.f64 d6, d7, d5 │ │ │ │ + ldmdavs fp!, {r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ + blvc 46fb0 │ │ │ │ + ldrcc fp, [r8, -r0, lsl #30] │ │ │ │ + stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ @ instruction: 0x401921fb │ │ │ │ - vst3.8 {d27,d29,d31}, [pc], r0 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb6e1e8 <__bss_end__@@Base+0xfeac75b0> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - selmi r0, r4, r0 │ │ │ │ - blmi 47074 │ │ │ │ - strmi fp, [fp], -r3, lsl #1 │ │ │ │ - addcs r4, r0, #819200 @ 0xc8000 │ │ │ │ - blne 146c30 <__bss_end__@@Base+0x9fff8> │ │ │ │ - ldc 6, cr4, [ip, #96] @ 0x60 │ │ │ │ - ldrbtmi lr, [r9], #-2818 @ 0xfffff4fe │ │ │ │ - blls 1c6c3c <__bss_end__@@Base+0x120004> │ │ │ │ - blcc 86e54 <__bss_start@@Base+0x2bdb4> │ │ │ │ - blgt 46c44 │ │ │ │ - blcc 3c6e10 <__bss_end__@@Base+0x3201d8> │ │ │ │ - blcc 286e00 <__bss_end__@@Base+0x1e01c8> │ │ │ │ - blcc 346e10 <__bss_end__@@Base+0x2a01d8> │ │ │ │ - blcs 106ff4 <__bss_end__@@Base+0x603bc> │ │ │ │ - blcc c6e6c <__bss_end__@@Base+0x20234> │ │ │ │ - blx c6e92 <__bss_end__@@Base+0x2025a> │ │ │ │ - blcs c6ea8 <__bss_end__@@Base+0x20270> │ │ │ │ - blle 106eac <__bss_end__@@Base+0x60274> │ │ │ │ - blge 106ea8 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blmi 46db4 │ │ │ │ - blcc 46dc0 │ │ │ │ - strbeq lr, [ip], #2816 @ 0xb00 │ │ │ │ - blvs 46dd4 │ │ │ │ - sbceq lr, r5, r0, lsl #22 │ │ │ │ - blvc 46dd0 │ │ │ │ - blvs 10705c <__bss_end__@@Base+0x60424> │ │ │ │ - blvc 147064 <__bss_end__@@Base+0xa042c> │ │ │ │ - blvs 187024 <__bss_end__@@Base+0xe03ec> │ │ │ │ - blvc 18702c <__bss_end__@@Base+0xe03f4> │ │ │ │ - blvs 46d98 │ │ │ │ - blvc 46db0 │ │ │ │ - blvc 46de8 │ │ │ │ - blvs 46de0 │ │ │ │ - blvc 1c7080 <__bss_end__@@Base+0x120448> │ │ │ │ - blvc 187044 <__bss_end__@@Base+0xe040c> │ │ │ │ - blvc 46de4 │ │ │ │ - pop {r0, r2, ip, sp, pc} │ │ │ │ - @ instruction: 0x464683f0 │ │ │ │ - stmdbeq r8, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ - strcs r2, [r1, #-784] @ 0xfffffcf0 │ │ │ │ - strcs r2, [r2, -r0, lsl #8] │ │ │ │ - cdp 7, 11, cr14, cr7, cr4, {5} │ │ │ │ - vldr d7, [r0] │ │ │ │ - vldr d4, [r0, #72] @ 0x48 │ │ │ │ - vmov.f64 d3, #108 @ 0x3f600000 0.875 │ │ │ │ - vadd.f64 d1, d6, d0 │ │ │ │ - vldr d6, [r0, #28] │ │ │ │ - vldr d2, [r0, #32] │ │ │ │ - vadd.f64 d7, d3, d2 │ │ │ │ - vldr d3, [r0, #272] @ 0x110 │ │ │ │ - vldr d5, [r0, #64] @ 0x40 │ │ │ │ - vmov.f64 d0, #20 @ 0x40a00000 5.0 │ │ │ │ - vsub.f64 d4, d23, d6 │ │ │ │ - vsub.f64 d7, d5, d2 │ │ │ │ - @ instruction: 0xee816b40 │ │ │ │ - vmul.f64 d2, d4, d4 │ │ │ │ - vstr d4, [r1, #4] │ │ │ │ - vmul.f64 d4, d3, d0 │ │ │ │ - vmul.f64 d3, d6, d2 │ │ │ │ - vmul.f64 d6, d7, d2 │ │ │ │ - vstr d7, [r1, #8] │ │ │ │ - vstr d3, [r1, #8] │ │ │ │ - vstr d6, [r1, #16] │ │ │ │ - ldrbmi r7, [r0, -r6, lsl #22]! │ │ │ │ - smlabteq r2, sp, r9, lr │ │ │ │ - @ instruction: 0xf7f79301 │ │ │ │ - ldmib sp, {r7, sl, fp, sp, lr, pc}^ │ │ │ │ - cdp 1, 11, cr0, cr0, cr2, {0} │ │ │ │ - blls 6a530 <__bss_start@@Base+0xf490> │ │ │ │ - svclt 0x0000e779 │ │ │ │ - vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb6e480 <__bss_end__@@Base+0xfeac7848> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - vldr , [r0, #192] @ 0xc0 │ │ │ │ - vmov.f64 d8, #4 @ 0x40200000 2.5 │ │ │ │ - vldr d11, [r0, #256] @ 0x100 │ │ │ │ - vmov.f64 d15, #114 @ 0x3f900000 1.125 │ │ │ │ - vldr d9, [r0] │ │ │ │ - ldrmi lr, [r4], -r6, lsl #22 │ │ │ │ - bleq 247100 <__bss_end__@@Base+0x1a04c8> │ │ │ │ - blge 46ea4 │ │ │ │ - bleq 4070a4 <__bss_end__@@Base+0x36046c> │ │ │ │ - blvc 1146ee8 <__bss_end__@@Base+0x10a02b0> │ │ │ │ - bleq 3c70a8 <__bss_end__@@Base+0x320470> │ │ │ │ - bleq 2c709c <__bss_end__@@Base+0x220464> │ │ │ │ - blvs 287138 <__bss_end__@@Base+0x1e0500> │ │ │ │ - blvs ff20734c <__bss_end__@@Base+0xff160714> │ │ │ │ - blx 447444 <__bss_end__@@Base+0x3a080c> │ │ │ │ - cdp 13, 3, cr13, cr9, cr13, {1} │ │ │ │ - strmi r6, [lr], -r0, asr #22 │ │ │ │ - blvs ff20735c <__bss_end__@@Base+0xff160724> │ │ │ │ - blx 447454 <__bss_end__@@Base+0x3a081c> │ │ │ │ - mrc 15, 1, fp, cr9, cr8, {6} │ │ │ │ - mrrcle 11, 4, r9, r8, cr11 │ │ │ │ - blvc c6ef4 <__bss_end__@@Base+0x202bc> │ │ │ │ - blx 28715e <__bss_end__@@Base+0x1e0526> │ │ │ │ - blvs 146efc <__bss_end__@@Base+0xa02c4> │ │ │ │ - blhi 287148 <__bss_end__@@Base+0x1e0510> │ │ │ │ - blpl 1c6f04 <__bss_end__@@Base+0x1202cc> │ │ │ │ - bl 287168 <__bss_end__@@Base+0x1e0530> │ │ │ │ - blx 2070e2 <__bss_end__@@Base+0x1604aa> │ │ │ │ - blvc 46f10 │ │ │ │ - blls 287164 <__bss_end__@@Base+0x1e052c> │ │ │ │ - blhi 1c70ec <__bss_end__@@Base+0x1204b4> │ │ │ │ - bl 1870f0 <__bss_end__@@Base+0xe04b8> │ │ │ │ - blls 2070f4 <__bss_end__@@Base+0x1604bc> │ │ │ │ - blx c6ede <__bss_end__@@Base+0x202a6> │ │ │ │ - blhi 146ee0 <__bss_end__@@Base+0xa02a8> │ │ │ │ - bl 1c6ee4 <__bss_end__@@Base+0x1202ac> │ │ │ │ - blls 46ee8 │ │ │ │ - blhi 446bd0 <__bss_end__@@Base+0x39ff98> │ │ │ │ - mrc 13, 5, fp, cr1, cr0, {3} │ │ │ │ - vneg.f64 d8, d8 │ │ │ │ - vsub.f64 d10, d9, d10 │ │ │ │ - vldr d0, [pc, #300] @ ba18 │ │ │ │ - strmi lr, [r5], -r6, lsr #22 │ │ │ │ - blhi c6efc <__bss_end__@@Base+0x202c4> │ │ │ │ - blle c6f38 <__bss_end__@@Base+0x20300> │ │ │ │ - bleq 3c717c <__bss_end__@@Base+0x320544> │ │ │ │ - blge 1c6f08 <__bss_end__@@Base+0x1202d0> │ │ │ │ - blgt 1c6f44 <__bss_end__@@Base+0x12030c> │ │ │ │ - blle 146f10 <__bss_end__@@Base+0xa02d8> │ │ │ │ - blgt 46f14 │ │ │ │ - ldcl 7, cr15, [r6, #988] @ 0x3dc │ │ │ │ - blls 10473d4 <__bss_end__@@Base+0xfa079c> │ │ │ │ - bleq 3c71c4 <__bss_end__@@Base+0x32058c> │ │ │ │ - ldcl 7, cr15, [r0, #988] @ 0x3dc │ │ │ │ - blhi 471c0 │ │ │ │ - blge 471cc │ │ │ │ - blvc 146f7c <__bss_end__@@Base+0xa0344> │ │ │ │ - blhi 287160 <__bss_end__@@Base+0x1e0528> │ │ │ │ - blge 287160 <__bss_end__@@Base+0x1e0528> │ │ │ │ - blvs 471e8 │ │ │ │ - blvs 20715c <__bss_end__@@Base+0x160524> │ │ │ │ - blhi c6f4c <__bss_end__@@Base+0x20314> │ │ │ │ - blge 1c6f50 <__bss_end__@@Base+0x120318> │ │ │ │ - blhi 446c38 <__bss_end__@@Base+0x3a0000> │ │ │ │ - blvs 146f58 <__bss_end__@@Base+0xa0320> │ │ │ │ - @ instruction: 0xf7f7bd70 │ │ │ │ - mrc 12, 5, lr, cr0, cr6, {4} │ │ │ │ - @ instruction: 0xf7f7cb40 │ │ │ │ - mrc 13, 5, lr, cr0, cr4, {5} │ │ │ │ - vsub.f64 d13, d9, d0 │ │ │ │ - vnmul.f64 d0, d0, d11 │ │ │ │ - @ instruction: 0xf7f70b0c │ │ │ │ - cdp 13, 11, cr14, cr0, cr12, {5} │ │ │ │ - vnmul.f64 d7, d11, d0 │ │ │ │ - vdiv.f64 d0, d7, d12 │ │ │ │ - @ instruction: 0xf7f79b0d │ │ │ │ - cdp 13, 8, cr14, cr0, cr4, {5} │ │ │ │ - str fp, [sp, sp, lsl #22] │ │ │ │ + addslt fp, ip, r0, lsl #11 │ │ │ │ + rsbsvs sl, r8, r0, lsl #30 │ │ │ │ + ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ + blvs c7010 <__bss_end__@@Base+0x20470> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d6, d2 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 147020 <__bss_end__@@Base+0xa0480> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d4 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 1c7034 <__bss_end__@@Base+0x120494> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d6 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 47048 │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d0 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vmov.f64 d6, #7 @ 0x40380000 2.875 │ │ │ │ + vdiv.f64 d5, d5, d0 │ │ │ │ + vstr d7, [r7, #24] │ │ │ │ + ldmdavs fp!, {r1, r3, r4, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc c7068 <__bss_end__@@Base+0x204c8> │ │ │ │ + blvs 6c707c <__bss_end__@@Base+0x6204dc> │ │ │ │ + blvc 2072bc <__bss_end__@@Base+0x16071c> │ │ │ │ + blvc 647044 <__bss_end__@@Base+0x5a04a4> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7, #16] │ │ │ │ + vmov.32 d6[1], r6 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmdavs fp!, {r1, r2, r4, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 1c708c <__bss_end__@@Base+0x1204ec> │ │ │ │ + blvs 6c70a0 <__bss_end__@@Base+0x620500> │ │ │ │ + blvc 2072e0 <__bss_end__@@Base+0x160740> │ │ │ │ + blvc 547068 <__bss_end__@@Base+0x4a04c8> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7] │ │ │ │ + vmov.32 d6[1], r6 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmdavs fp!, {r1, r4, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 470b0 │ │ │ │ + blvs 5c70c4 <__bss_end__@@Base+0x520524> │ │ │ │ + blvc 207304 <__bss_end__@@Base+0x160764> │ │ │ │ + blvc 44708c <__bss_end__@@Base+0x3a04ec> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7] │ │ │ │ + vmov.32 d6[1], r6 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmdavs fp!, {r1, r2, r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc c70d4 <__bss_end__@@Base+0x20534> │ │ │ │ + blvs 6470e8 <__bss_end__@@Base+0x5a0548> │ │ │ │ + blvc 207328 <__bss_end__@@Base+0x160788> │ │ │ │ + blvc 3470b0 <__bss_end__@@Base+0x2a0510> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7, #8] │ │ │ │ + vmov.32 d6[1], r6 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmdavs fp!, {r1, r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc c70f8 <__bss_end__@@Base+0x20558> │ │ │ │ + blvs 54710c <__bss_end__@@Base+0x4a056c> │ │ │ │ + blvc 20734c <__bss_end__@@Base+0x1607ac> │ │ │ │ + blvc 2470d4 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lr}^ │ │ │ │ + blvc 1475a0 <__bss_end__@@Base+0xa0a00> │ │ │ │ + @ instruction: 0xed93697b │ │ │ │ + vldr d6, [r7, #24] │ │ │ │ + vmul.f64 d7, d6, d14 │ │ │ │ + ldmdbvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr} │ │ │ │ + blpl 1c75f4 <__bss_end__@@Base+0x120a54> │ │ │ │ + blvc 347608 <__bss_end__@@Base+0x2a0a68> │ │ │ │ + blvc 207844 <__bss_end__@@Base+0x160ca4> │ │ │ │ + blvc 20788c <__bss_end__@@Base+0x160cec> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdbvs fp!, {r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 4760c │ │ │ │ + blvc 3c7620 <__bss_end__@@Base+0x320a80> │ │ │ │ + blvs 207860 <__bss_end__@@Base+0x160cc0> │ │ │ │ + @ instruction: 0xed93693b │ │ │ │ + vldr d5, [r7] │ │ │ │ + vmul.f64 d7, d5, d12 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 475ec │ │ │ │ + ldmdbvs fp!, {r4, r5, r6, sp, lr, pc}^ │ │ │ │ + blvc 147634 <__bss_end__@@Base+0xa0a94> │ │ │ │ + blvc 1207ab0 <__bss_end__@@Base+0x1160f10> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdbvs fp!, {r1, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + movwcs lr, #10707 @ 0x29d3 │ │ │ │ + stmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ + ldmdbvs fp!, {r2, r8, r9, sp}^ │ │ │ │ + blvc 47650 │ │ │ │ + blvc 1207acc <__bss_end__@@Base+0x1160f2c> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdbvs fp!, {r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + movwcs lr, #27091 @ 0x69d3 │ │ │ │ + stmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ + cdp 3, 11, cr2, cr7, cr0, {0} │ │ │ │ + vldr d6, [r7] │ │ │ │ + vadd.f64 d7, d6, d2 │ │ │ │ + vldr d7, [pc, #284] @ c144 │ │ │ │ + vmul.f64 d6, d7, d27 │ │ │ │ + vmov.f64 d7, #6 @ 0x40300000 2.750 │ │ │ │ + @ instruction: 0xf7f70b47 │ │ │ │ + vstr s28, [r7, #96] @ 0x60 │ │ │ │ + vldr d0, [r7, #56] @ 0x38 │ │ │ │ + vldr d7, [pc, #8] @ c048 │ │ │ │ + vmul.f64 d6, d7, d21 │ │ │ │ + vmov.f64 d7, #6 @ 0x40300000 2.750 │ │ │ │ + @ instruction: 0xf7f70b47 │ │ │ │ + vstr s28, [r7, #48] @ 0x30 │ │ │ │ + ldmdbvs fp!, {r2, r3, r8, r9, fp}^ │ │ │ │ + blvs c76a4 <__bss_end__@@Base+0x20b04> │ │ │ │ + blvc 3c76b8 <__bss_end__@@Base+0x320b18> │ │ │ │ + blvs 2078f8 <__bss_end__@@Base+0x160d58> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d5, [r7, #8] │ │ │ │ + vmul.f64 d7, d5, d12 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc c7684 <__bss_end__@@Base+0x20ae4> │ │ │ │ + @ instruction: 0xed93697b │ │ │ │ + vldr d6, [r7, #16] │ │ │ │ + vmul.f64 d7, d6, d14 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 1476d8 <__bss_end__@@Base+0xa0b38> │ │ │ │ + blvc 3476ec <__bss_end__@@Base+0x2a0b4c> │ │ │ │ + blvc 207928 <__bss_end__@@Base+0x160d88> │ │ │ │ + blvc 207970 <__bss_end__@@Base+0x160dd0> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdbvs fp!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 1c76f0 <__bss_end__@@Base+0x120b50> │ │ │ │ + blvc 3c7704 <__bss_end__@@Base+0x320b64> │ │ │ │ + blvs 207944 <__bss_end__@@Base+0x160da4> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d5, [r7, #24] │ │ │ │ + vmul.f64 d7, d5, d12 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 1c76d0 <__bss_end__@@Base+0x120b30> │ │ │ │ + strbcc fp, [r0, -r0, lsl #30] │ │ │ │ + stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ adcsge lr, r5, sp, lsl #27 │ │ │ │ mrccc 6, 5, ip, cr0, cr7, {7} │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ svccc 0x00f921fb │ │ │ │ - mvnsmi lr, sp, lsr #18 │ │ │ │ - stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - @ instruction: 0x0c0cebad │ │ │ │ - svceq 0x00c8f8cc │ │ │ │ - blvc 146fe0 <__bss_end__@@Base+0xa03a8> │ │ │ │ - ldc 6, cr4, [r1, #52] @ 0x34 │ │ │ │ - ldrmi r3, [r0], r4, lsl #22 │ │ │ │ - blmi c6fec <__bss_end__@@Base+0x203b4> │ │ │ │ - ldc 6, cr4, [r1, #284] @ 0x11c │ │ │ │ - addlt r5, r8, r2, lsl #22 │ │ │ │ - blvc 107254 <__bss_end__@@Base+0x6061c> │ │ │ │ - blvs 1c6ffc <__bss_end__@@Base+0x1203c4> │ │ │ │ - blcs 1c7004 <__bss_end__@@Base+0x1203cc> │ │ │ │ - cdp 6, 0, cr4, cr4, cr6, {0} │ │ │ │ - vldr d7, [r0, #20] │ │ │ │ - vldr d3, [r1] │ │ │ │ - strbtmi r5, [ip], -r0, lsl #22 │ │ │ │ - strtmi r4, [r2], -ip, lsr #18 │ │ │ │ - andcc r4, r8, ip, lsr #22 │ │ │ │ - blvc c71f4 <__bss_end__@@Base+0x205bc> │ │ │ │ - stmiapl fp, {r0, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - tstpeq r8, r5, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - movwls r6, #30747 @ 0x781b │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - blvc 18723c <__bss_end__@@Base+0xe0604> │ │ │ │ - blvc c6c90 <__bss_end__@@Base+0x20058> │ │ │ │ - @ instruction: 0xf900f7ff │ │ │ │ - blvc 47050 │ │ │ │ - blcs c7058 <__bss_end__@@Base+0x20420> │ │ │ │ - ldc 6, cr4, [r6, #656] @ 0x290 │ │ │ │ - vldr d4, [r6, #16] │ │ │ │ - vldr d3, [r5] │ │ │ │ - vmul.f64 d6, d7, d2 │ │ │ │ - vldr d2, [r5, #8] │ │ │ │ - vmul.f64 d5, d7, d4 │ │ │ │ - vldr d4, [r6, #16] │ │ │ │ - vmla.f64 d1, d3, d6 │ │ │ │ - vldr d2, [r5, #24] │ │ │ │ - vmla.f64 d0, d3, d6 │ │ │ │ - vldr d4, [sp, #20] │ │ │ │ - vldr d6, [sp, #8] │ │ │ │ - vmul.f64 d5, d7, d0 │ │ │ │ - vmla.f64 d7, d3, d1 │ │ │ │ - vldr d7, [sp] │ │ │ │ - vadd.f64 d3, d5, d4 │ │ │ │ - vadd.f64 d5, d6, d2 │ │ │ │ - vadd.f64 d6, d3, d4 │ │ │ │ - vstr d3, [sp, #28] │ │ │ │ - vstr d5, [sp] │ │ │ │ - ldm ip!, {r1, r8, r9, fp, sp, lr} │ │ │ │ - strgt r0, [pc, -pc] │ │ │ │ - blmi 2de28c <__bss_end__@@Base+0x237654> │ │ │ │ - stc 4, cr4, [sp, #488] @ 0x1e8 │ │ │ │ - ldm ip, {r2, r8, r9, fp, ip, sp} │ │ │ │ - stm r7, {r0, r1} │ │ │ │ - ldmpl r3, {r0, r1}^ │ │ │ │ - blls 1e5ad8 <__bss_end__@@Base+0x13eea0> │ │ │ │ - @ instruction: 0xf04f405a │ │ │ │ - mrsle r0, SP_svc │ │ │ │ - andlt r4, r8, r0, asr #12 │ │ │ │ - ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ - ldc 7, cr15, [ip], {247} @ 0xf7 │ │ │ │ - andeq ip, r4, r4, lsr #12 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq ip, r4, r4, lsr #11 │ │ │ │ - strmi r4, [r8], -r3, lsl #12 │ │ │ │ - blpl c70e4 <__bss_end__@@Base+0x204ac> │ │ │ │ - blvs 1470e8 <__bss_end__@@Base+0xa04b0> │ │ │ │ - blvc 1c70ec <__bss_end__@@Base+0x1204b4> │ │ │ │ - blpl 1187568 <__bss_end__@@Base+0x10e0930> │ │ │ │ - blvs 11c756c <__bss_end__@@Base+0x1120934> │ │ │ │ - blvc 1207570 <__bss_end__@@Base+0x1160938> │ │ │ │ + stc 5, cr11, [sp, #-704]! @ 0xfffffd40 │ │ │ │ + addlt r8, sl, r2, lsl #22 │ │ │ │ + rscsvs sl, r8, r0, lsl #30 │ │ │ │ + ldrhtvs r6, [sl], #-9 │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, sp, lr} │ │ │ │ + blvc 47744 │ │ │ │ + blhi 207994 <__bss_end__@@Base+0x160df4> │ │ │ │ + @ instruction: 0xf10368fb │ │ │ │ + ldmvs fp!, {r3, r9} │ │ │ │ + ldrmi r3, [r9], -r8, lsl #6 │ │ │ │ + @ instruction: 0xf7fe4610 │ │ │ │ + mrc 13, 5, APSR_nzcv, cr0, cr6, {1} │ │ │ │ + vsub.f64 d7, d8, d0 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 47728 │ │ │ │ + @ instruction: 0xf10368fb │ │ │ │ + ldmvs fp!, {r3} │ │ │ │ + @ instruction: 0xf1073308 │ │ │ │ + @ instruction: 0x46190210 │ │ │ │ + stc2l 7, cr15, [sp, #-1016] @ 0xfffffc08 │ │ │ │ + blvs 147790 <__bss_end__@@Base+0xa0bf0> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, ip, lr} │ │ │ │ + blvc c778c <__bss_end__@@Base+0x20bec> │ │ │ │ + blpl 2079d8 <__bss_end__@@Base+0x160e38> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, lr}^ │ │ │ │ + blvc c779c <__bss_end__@@Base+0x20bfc> │ │ │ │ + blvc 2079e4 <__bss_end__@@Base+0x160e44> │ │ │ │ + blvc 207a2c <__bss_end__@@Base+0x160e8c> │ │ │ │ + blvc 207a34 <__bss_end__@@Base+0x160e94> │ │ │ │ + blvc 14777c <__bss_end__@@Base+0xa0bdc> │ │ │ │ + blvs 1c77c0 <__bss_end__@@Base+0x120c20> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, ip, lr} │ │ │ │ + blvc 1477bc <__bss_end__@@Base+0xa0c1c> │ │ │ │ + blpl 207a08 <__bss_end__@@Base+0x160e68> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, lr}^ │ │ │ │ + blvc 1477cc <__bss_end__@@Base+0xa0c2c> │ │ │ │ + blvc 207a14 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0x37284618 │ │ │ │ + ldc 6, cr4, [sp], #756 @ 0x2f4 │ │ │ │ + @ instruction: 0xbdb08b02 │ │ │ │ + addlt fp, r3, r0, lsl #9 │ │ │ │ + rsbsvs sl, r8, r0, lsl #30 │ │ │ │ + ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ - movwcs lr, #2497 @ 0x9c1 │ │ │ │ - blpl c70bc <__bss_end__@@Base+0x20484> │ │ │ │ - blvs 1470c0 <__bss_end__@@Base+0xa0488> │ │ │ │ - blvc 1c70c4 <__bss_end__@@Base+0x12048c> │ │ │ │ - svclt 0x00004770 │ │ │ │ + stmib r1, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ + ldmdavs fp!, {r8, r9, sp}^ │ │ │ │ + blvc c784c <__bss_end__@@Base+0x20cac> │ │ │ │ + blvc 1207cc8 <__bss_end__@@Base+0x1161128> │ │ │ │ + stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ + ldmdavs fp!, {r1, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 14785c <__bss_end__@@Base+0xa0cbc> │ │ │ │ + blvc 1207cd8 <__bss_end__@@Base+0x1161138> │ │ │ │ + stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ + ldmdavs fp!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 1c786c <__bss_end__@@Base+0x120ccc> │ │ │ │ + blvc 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eorscc pc, r2, r3, asr r8 @ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ ssatmi r3, #30, r4, lsl #14 │ │ │ │ - blvc 149c84 <__bss_end__@@Base+0xa304c> │ │ │ │ + blvc 14a3f8 <__bss_end__@@Base+0xa3858> │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq lr, r4, ip, lsr #2 │ │ │ │ - andeq lr, r4, ip, lsl r1 │ │ │ │ - andeq lr, r4, r8, lsl #2 │ │ │ │ - andeq r0, r0, r0 │ │ │ │ + andeq sp, r4, r0, lsr sl │ │ │ │ + andeq sp, r4, r0, lsr #20 │ │ │ │ + andeq sp, r4, ip, lsl #20 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blcs 25d1c │ │ │ │ + blcs 2648c │ │ │ │ @ instruction: 0xf04fd102 │ │ │ │ strd r3, [sp], -pc @ │ │ │ │ ldrbtmi r4, [fp], #-2840 @ 0xfffff4e8 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - stc 7, cr15, [r8, #-988]! @ 0xfffffc24 │ │ │ │ - blcs 1d354 │ │ │ │ + ldmdb lr!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blcs 1dac4 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ - blmi 543bd8 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│ - ldmda lr, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + mcrr 7, 15, pc, r0, cr6 @ │ │ │ │ ldrmi r4, [sl], -r3, lsl #12 │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ mcrrcs 8, 2, pc, sl, cr3 @ │ │ │ │ movteq pc, #33031 @ 0x8107 @ │ │ │ │ andscs r3, r0, #12, 22 @ 0x3000 │ │ │ │ @ instruction: 0xf5074619 │ │ │ │ @ instruction: 0xf1035301 │ │ │ │ ldmdavs r8, {r4, r5, r8, r9} │ │ │ │ - ldmdb ip, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - blcs 1d864 │ │ │ │ + stc 7, cr15, [r0, #984] @ 0x3d8 │ │ │ │ + blcs 1dfd4 │ │ │ │ @ instruction: 0xf8dfd007 │ │ │ │ ldrbtmi r3, [fp], #-1476 @ 0xfffffa3c │ │ │ │ - @ instruction: 0xf7f74618 │ │ │ │ - movwcs lr, #2108 @ 0x83c │ │ │ │ + @ instruction: 0xf7f64618 │ │ │ │ + movwcs lr, #3166 @ 0xc5e │ │ │ │ movwcs lr, #707 @ 0x2c3 │ │ │ │ eorvc pc, r2, #1325400064 @ 0x4f000000 │ │ │ │ cmppne pc, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ streq pc, [ip, #2271]! @ 0x8df │ │ │ │ @ instruction: 0xf0074478 │ │ │ │ - @ instruction: 0xf507fcb7 │ │ │ │ + @ instruction: 0xf507f96b │ │ │ │ @ instruction: 0xf1035301 │ │ │ │ andsvs r0, r8, ip, lsr #6 │ │ │ │ movwpl pc, #5383 @ 0x1507 @ │ │ │ │ msreq CPSR_fs, #-1073741824 @ 0xc0000000 │ │ │ │ andcs r6, r0, #1769472 @ 0x1b0000 │ │ │ │ @ instruction: 0xf507601a │ │ │ │ @ instruction: 0xf1035301 │ │ │ │ @@ -8867,24 +9370,24 @@ │ │ │ │ @ instruction: 0xf1035301 │ │ │ │ ldmdavs fp, {r2, r3, r5, r8, r9} │ │ │ │ andpl pc, r1, #29360128 @ 0x1c00000 │ │ │ │ eorseq pc, r0, #-2147483648 @ 0x80000000 │ │ │ │ andsvs r6, sl, r2, lsl r8 │ │ │ │ movwpl pc, #5383 @ 0x1507 @ │ │ │ │ teqpeq r8, #-1073741824 @ p-variant is OBSOLETE @ 0xc0000000 │ │ │ │ - blcs 26134 │ │ │ │ + blcs 268a4 │ │ │ │ sbcshi pc, r5, r0 │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ stccc 8, cr15, [r0], {83} @ 0x53 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ @ instruction: 0xf10780ce │ │ │ │ - blcc e0ce00 <__bss_end__@@Base+0xd661c8> │ │ │ │ + blcc e0d570 <__bss_end__@@Base+0xd669d0> │ │ │ │ tstcs r0, r0, lsr #4 │ │ │ │ @ instruction: 0xf7f64618 │ │ │ │ - @ instruction: 0xf107efd0 │ │ │ │ + @ instruction: 0xf107ebf2 │ │ │ │ ldrmi r0, [sl], -r8, lsl #7 │ │ │ │ @ instruction: 0xf8422302 │ │ │ │ @ instruction: 0xf1073c74 │ │ │ │ ldrmi r0, [sl], -r8, lsl #7 │ │ │ │ @ instruction: 0xf8422302 │ │ │ │ @ instruction: 0xf1073c70 │ │ │ │ ldrmi r0, [sl], -r8, lsl #7 │ │ │ │ @@ -8894,73 +9397,73 @@ │ │ │ │ @ instruction: 0xf8422300 │ │ │ │ @ instruction: 0xf1073c78 │ │ │ │ ldrmi r0, [sl], -r8, lsl #7 │ │ │ │ movteq pc, #33031 @ 0x8107 @ │ │ │ │ @ instruction: 0xf8523b14 │ │ │ │ @ instruction: 0xf8df2c84 │ │ │ │ ldrbtmi r1, [r9], #-1276 @ 0xfffffb04 │ │ │ │ - @ instruction: 0xf7f74618 │ │ │ │ - @ instruction: 0xf107ea66 │ │ │ │ - blcc 60ce5c <__bss_end__@@Base+0x566224> │ │ │ │ + @ instruction: 0xf7f64618 │ │ │ │ + @ instruction: 0xf107ee7c │ │ │ │ + blcc 60d5cc <__bss_end__@@Base+0x566a2c> │ │ │ │ subeq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ @ instruction: 0xf1073a38 │ │ │ │ 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0x46204479 │ │ │ │ - ldm sl!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldc 7, cr15, [lr, #-984] @ 0xfffffc28 │ │ │ │ movwpl pc, #5383 @ 0x1507 @ │ │ │ │ teqpeq r0, #-1073741824 @ p-variant is OBSOLETE @ 0xc0000000 │ │ │ │ - @ instruction: 0xf7f76818 │ │ │ │ - @ instruction: 0xf507e8ba │ │ │ │ + @ instruction: 0xf7f66818 │ │ │ │ + @ instruction: 0xf507ecde │ │ │ │ @ instruction: 0xf1035301 │ │ │ │ ldmdavs r8, {r2, r3, r5, r8, r9} │ │ │ │ - stc2l 0, cr15, [r6], {7} │ │ │ │ + @ instruction: 0xf97af007 │ │ │ │ ands r2, r6, #0, 6 │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ mrrccc 8, 5, pc, r8, cr3 @ │ │ │ │ @ instruction: 0xd1272b00 │ │ │ │ ldrbcc pc, [r8], #-2271 @ 0xfffff721 @ │ │ │ │ ldmdavs r8, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ addeq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ stccc 8, cr15, [r4], {83} @ 0x53 │ │ │ │ stccs 8, cr15, [r0], {82} @ 0x52 │ │ │ │ strbne pc, [r8], #-2271 @ 0xfffff721 @ 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r6 │ │ │ │ @ instruction: 0xf04f6261 │ │ │ │ @ instruction: 0xf03c0300 │ │ │ │ - vfma.f32 , q10, │ │ │ │ + vmla.i8 d31, d4, d7 │ │ │ │ vmla.f d18, d0, d0[0] │ │ │ │ - blx 4d126 │ │ │ │ + blx 4d896 │ │ │ │ tstpcs r0, r3 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf101fb02 │ │ │ │ vshl.s8 d20, d8, d4 │ │ │ │ vmla.f d18, d0, d0[0] │ │ │ │ - blx fe88d13a <__bss_end__@@Base+0xfe7e6502> │ │ │ │ + blx fe88d8aa <__bss_end__@@Base+0xfe7e6d0a> │ │ │ │ stmdbne r3, {r0, r8, sl, lr}^ │ │ │ │ ldmib r7, {r0, r2, r3, r4, r9, sl, lr}^ │ │ │ │ - bl 515928 <__bss_end__@@Base+0x46ecf0> │ │ │ │ - bl 114f514 <__bss_end__@@Base+0x10a88dc> │ │ │ │ + bl 516098 <__bss_end__@@Base+0x46f4f8> │ │ │ │ + bl 114fc84 <__bss_end__@@Base+0x10a90e4> │ │ │ │ stmib r7, {r0, r1, r8, r9, fp}^ │ │ │ │ ldmib r7, {r1, r3, r8, r9, fp, sp, pc}^ │ │ │ │ strtmi r4, [r2], -sl, lsl #10 │ │ │ │ @ instruction: 0xf04f462b │ │ │ │ @ instruction: 0xf04f0000 │ │ │ │ ldreq r0, [r9, r0, lsl #2] │ │ │ │ orrseq lr, r2, r1, asr #20 │ │ │ │ @ instruction: 0x46020790 │ │ │ │ - bl fec9e55c <__bss_end__@@Base+0xfebf7924> │ │ │ │ - bl 18ced44 <__bss_end__@@Base+0x182810c> │ │ │ │ - bl 60f14c <__bss_end__@@Base+0x568514> │ │ │ │ + bl fec9eccc <__bss_end__@@Base+0xfebf812c> │ │ │ │ + bl 18cf4b4 <__bss_end__@@Base+0x1828914> │ │ │ │ + bl 60f8bc <__bss_end__@@Base+0x568d1c> │ │ │ │ eorsvs r0, fp, r8, lsl #6 │ │ │ │ movweq lr, #39753 @ 0x9b49 │ │ │ │ ldmib r7, {r0, r1, r3, r4, r5, r6, sp, lr}^ │ │ │ │ strbmi r8, [r0], -r0, lsl #18 │ │ │ │ movwge r4, #42569 @ 0xa649 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ - stc2l 0, cr15, [r0], {60} @ 0x3c │ │ │ │ + @ instruction: 0xf8ccf03c │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ movwcs lr, #43463 @ 0xa9c7 │ │ │ │ @ instruction: 0xf0236abb │ │ │ │ ldmvs fp!, {r9, lr}^ │ │ │ │ movwcs r6, #90 @ 0x5a │ │ │ │ @ instruction: 0x37304618 │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ @@ -9686,52 +10189,52 @@ │ │ │ │ ldrle sl, [r3], r0, lsl #8 │ │ │ │ andeq r0, r0, r0 │ │ │ │ svcmi 0x00b0e92d │ │ │ │ svcge 0x0000b08c │ │ │ │ @ instruction: 0xf10760f8 │ │ │ │ @ instruction: 0xf1070210 │ │ │ │ @ instruction: 0x46110318 │ │ │ │ - @ instruction: 0xf7f64618 │ │ │ │ - strmi lr, [r3], -r0, ror #18 │ │ │ │ + @ instruction: 0xf7f54618 │ │ │ │ + strmi lr, [r3], -r2, lsl #27 │ │ │ │ andle r2, r2, r0, lsl #22 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ ldmib r7, {r2, r3, r6, sp, lr, pc}^ │ │ │ │ vst4.8 {d16,d18,d20,d22}, [pc], r6 │ │ │ │ @ instruction: 0xf04f6261 │ │ │ │ @ instruction: 0xf03c0300 │ │ │ │ - vfma.f32 d31, d20, d1 │ │ │ │ + vtst.8 d31, d20, d13 │ │ │ │ vmla.f d18, d0, d0[0] │ │ │ │ - blx 4d1fa │ │ │ │ + blx 4d96a │ │ │ │ tstpcs r0, r3 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf101fb02 │ │ │ │ vshl.s8 d20, d8, d4 │ │ │ │ vmla.f d18, d0, d0[0] │ │ │ │ - blx fe88d20e <__bss_end__@@Base+0xfe7e65d6> │ │ │ │ - bl 2f1d8 │ │ │ │ + blx fe88d97e <__bss_end__@@Base+0xfe7e6dde> │ │ │ │ + bl 2f948 │ │ │ │ ldrmi r0, [r9], r9, lsl #6 │ │ │ │ movwcs lr, #35287 @ 0x89d7 │ │ │ │ - beq c7a40 <__bss_end__@@Base+0x20e08> │ │ │ │ - bleq 107b08 <__bss_end__@@Base+0x60ed0> │ │ │ │ - blge 2c7504 <__bss_end__@@Base+0x2208cc> │ │ │ │ + beq c81b0 <__bss_end__@@Base+0x21610> │ │ │ │ + bleq 108278 <__bss_end__@@Base+0x616d8> │ │ │ │ + blge 2c7c74 <__bss_end__@@Base+0x2210d4> │ │ │ │ stmdbhi sl, {r0, r1, r2, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ strbmi r4, [fp], -r2, asr #12 │ │ │ │ andeq pc, r0, pc, asr #32 │ │ │ │ tstpeq r0, pc, asr #32 @ p-variant is OBSOLETE │ │ │ │ - b 104ec60 <__bss_end__@@Base+0xfa8028> │ │ │ │ + b 104f3d0 <__bss_end__@@Base+0xfa8830> │ │ │ │ @ instruction: 0x07900192 │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ streq lr, [r8], #-2994 @ 0xfffff44e │ │ │ │ streq lr, [r9, #-2915] @ 0xfffff49d │ │ │ │ eorsvs r1, fp, r3, lsr #18 │ │ │ │ movweq lr, #23365 @ 0x5b45 │ │ │ │ ldmib r7, {r0, r1, r3, r4, r5, r6, sp, lr}^ │ │ │ │ strtmi r4, [r0], -r0, lsl #10 │ │ │ │ movwge r4, #46633 @ 0xb629 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ - mrrc2 0, 3, pc, r6, cr12 @ │ │ │ │ + @ instruction: 0xf862f03c │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ movwcs lr, #43463 @ 0xa9c7 │ │ │ │ @ instruction: 0xf0236abb │ │ │ │ ldmvs fp!, {r3, r4, r5, r6, r9, lr}^ │ │ │ │ movwcs r6, #26 │ │ │ │ @ instruction: 0x37304618 │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ @@ -9742,105 +10245,105 @@ │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ movwcs r6, #57 @ 0x39 │ │ │ │ ldrbtmi r4, [sl], #-2564 @ 0xfffff5fc │ │ │ │ cmnpcc r3, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [r8], #-2051 @ 0xfffff7fd │ │ │ │ ldc2l 0, cr15, [ip], {5} │ │ │ │ - stmda sl!, {r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - muleq r4, r6, sp │ │ │ │ - ldrdeq r1, [r4], -sl │ │ │ │ + stc 7, cr15, [sl], {245} @ 0xf5 │ │ │ │ + andeq r1, r4, r6, asr #14 │ │ │ │ + andeq r1, r4, sl, lsl #9 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ movwcs r6, #57 @ 0x39 │ │ │ │ ldrbtmi r4, [sl], #-2564 @ 0xfffff5fc │ │ │ │ orrcc pc, r1, r0, asr #4 │ │ │ │ ldrbtmi r4, [r8], #-2051 @ 0xfffff7fd │ │ │ │ stc2l 0, cr15, [r8], {5} │ │ │ │ - ldmda r6, {r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - andeq r1, r4, lr, ror #26 │ │ │ │ - @ instruction: 0x00041ab2 │ │ │ │ + ldcl 7, cr15, [r6], #-980 @ 0xfffffc2c │ │ │ │ + andeq r1, r4, lr, lsl r7 │ │ │ │ + andeq r1, r4, r2, ror #8 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ @ instruction: 0x3058f893 │ │ │ │ - blcs 21babc <__bss_end__@@Base+0x174e84> │ │ │ │ + blcs 21c22c <__bss_end__@@Base+0x17568c> │ │ │ │ andcs fp, r1, #140, 30 @ 0x230 │ │ │ │ sbcslt r2, r2, #0, 4 │ │ │ │ tstle r9, r0, lsl #20 │ │ │ │ addsmi r2, sl, r1, lsl #4 │ │ │ │ teqpne r3, #64, 4 @ p-variant is OBSOLETE │ │ │ │ - blcs 1cf1c │ │ │ │ + blcs 1d68c │ │ │ │ movwcs fp, #7956 @ 0x1f14 │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ tstle pc, r0, lsl #22 │ │ │ │ biceq pc, ip, #2 │ │ │ │ svclt 0x00142b00 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ - blcs 39a58 │ │ │ │ + blcs 3a1c8 │ │ │ │ ldmdavs r9!, {r2, ip, lr, pc} │ │ │ │ @ instruction: 0xf0006878 │ │ │ │ and pc, r2, fp, lsr #16 │ │ │ │ and fp, r0, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r8, r9, sl, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf503687a │ │ │ │ @ instruction: 0x461173d0 │ │ │ │ @ instruction: 0x46182298 │ │ │ │ - stmib lr, {r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldc 7, cr15, [r2, #980]! @ 0x3d4 │ │ │ │ ldcl 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ @ instruction: 0xeeb77a14 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r5, r6, r7, r9, fp, ip, sp, lr}^ │ │ │ │ - bvs 50866c <__bss_end__@@Base+0x461a34> │ │ │ │ - bvs ff9c8a00 <__bss_end__@@Base+0xff921dc8> │ │ │ │ + bvs 508ddc <__bss_end__@@Base+0x46223c> │ │ │ │ + bvs ff9c9170 <__bss_end__@@Base+0xff9225d0> │ │ │ │ ldcl 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ @ instruction: 0xeeb75a12 │ │ │ │ ldmdavs fp!, {r0, r2, r5, r6, r7, r9, fp, ip, lr} │ │ │ │ ldrmi r3, [r8], -r0, lsr #6 │ │ │ │ - blcs 11889f8 <__bss_end__@@Base+0x10e1dc0> │ │ │ │ - blne 11c89fc <__bss_end__@@Base+0x1121dc4> │ │ │ │ - bleq 1208a00 <__bss_end__@@Base+0x1161dc8> │ │ │ │ - blx 1dcaf3c <__bss_end__@@Base+0x1d24304> │ │ │ │ + blcs 1189168 <__bss_end__@@Base+0x10e25c8> │ │ │ │ + blne 11c916c <__bss_end__@@Base+0x11225cc> │ │ │ │ + bleq 1209170 <__bss_end__@@Base+0x11625d0> │ │ │ │ + @ instruction: 0xf84cf7fe │ │ │ │ strcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addslt fp, r0, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xf04f6039 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ @ instruction: 0xf04f230e │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ @ instruction: 0xf04f230c │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ ldmdavs fp!, {r1, r3, r8, r9, sp}^ │ │ │ │ - bvc 7886cc <__bss_end__@@Base+0x6e1a94> │ │ │ │ - bvc ffa08a60 <__bss_end__@@Base+0xff961e28> │ │ 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ip!, {r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - bleq c85ec <__bss_end__@@Base+0x219b4> │ │ │ │ - blvc c8630 <__bss_end__@@Base+0x219f8> │ │ │ │ - blvc ff048aac <__bss_end__@@Base+0xfefa1e74> │ │ │ │ - blx 448ba0 <__bss_end__@@Base+0x3a1f68> │ │ │ │ + bvc 808e58 <__bss_end__@@Base+0x7622b8> │ │ │ │ + bvc ffa091ec <__bss_end__@@Base+0xff96264c> │ │ │ │ + blvc 148d30 <__bss_end__@@Base+0xa2190> │ │ │ │ + blvc 248d74 <__bss_end__@@Base+0x1a21d4> │ │ │ │ + blvs 208fb8 <__bss_end__@@Base+0x162418> │ │ │ │ + blvc 1c8d7c <__bss_end__@@Base+0x1221dc> │ │ │ │ + blvc 208fc0 <__bss_end__@@Base+0x162420> │ │ │ │ + blvs 209000 <__bss_end__@@Base+0x162460> │ │ │ │ + blvc 148d88 <__bss_end__@@Base+0xa21e8> │ │ │ │ + blvc 208fcc <__bss_end__@@Base+0x16242c> │ │ │ │ + blvc 20900c <__bss_end__@@Base+0x16246c> │ │ │ │ + bleq 12091f8 <__bss_end__@@Base+0x1162658> │ │ │ │ + stcl 7, cr15, [lr], {245} @ 0xf5 │ │ │ │ + bleq c8d5c <__bss_end__@@Base+0x221bc> │ │ │ │ + blvc c8da0 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0xf107e08d │ │ │ │ ldmvs sl!, {r3, r4, r8, r9} │ │ │ │ ldrmi r2, [r8], -r1, asr #2 │ │ │ │ - @ instruction: 0xf8fcf006 │ │ │ │ - blcs 27c08 │ │ │ │ + ldc2 0, cr15, [r0, #20]! │ │ │ │ + blcs 28378 │ │ │ │ @ instruction: 0xf107d007 │ │ │ │ ldmdavs sl!, {r2, r3, r4, r6, r8, r9} │ │ │ │ @ instruction: 0x46182111 │ │ │ │ - @ instruction: 0xf8f2f006 │ │ │ │ + stc2 0, cr15, [r6, #20]! │ │ │ │ @ instruction: 0xf107e007 │ │ │ │ - bmi fce8a4 <__bss_end__@@Base+0xf27c6c> │ │ │ │ + bmi fcf014 <__bss_end__@@Base+0xf28474> │ │ │ │ tstcs r1, sl, ror r4 │ │ │ │ - @ instruction: 0xf0064618 │ │ │ │ - @ instruction: 0xf107f8e9 │ │ │ │ + @ instruction: 0xf0054618 │ │ │ │ + @ instruction: 0xf107fd9d │ │ │ │ @ instruction: 0x67bb0318 │ │ │ │ cmppeq ip, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ svcvs 0x00b84619 │ │ │ │ - stc 7, cr15, [sl, #-980] @ 0xfffffc2c │ │ │ │ + stmdb r0!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ svcvs 0x007b6778 │ │ │ │ rsble r2, r5, r0, lsl #22 │ │ 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instruction: 0xf5b36f3b │ │ │ │ - blle 5da14 <__bss_start@@Base+0x2974> │ │ │ │ + blle 5e184 <__bss_start@@Base+0x317c> │ │ │ │ and r2, r6, r3, lsl #6 │ │ │ │ addslt r6, sl, #59, 30 @ 0xec │ │ │ │ @ instruction: 0x809a68fb │ │ │ │ ldrbvs r2, [fp, r0, lsl #6]! │ │ │ │ ssub8mi r6, r8, fp │ │ │ │ ldrtmi r3, [sp], r0, lsl #15 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - ldrdeq r1, [r4], -r4 │ │ │ │ + andeq r0, r4, r4, lsl #21 │ │ │ │ addlt fp, lr, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ tstle r4, r0, lsl #22 │ │ │ │ adcs r2, r5, r0, lsl #6 │ │ │ │ movwcc r6, #6267 @ 0x187b │ │ │ │ - @ instruction: 0xf7f5607b │ │ │ │ - @ instruction: 0x4603eb9c │ │ │ │ + @ instruction: 0xf7f4607b │ │ │ │ + strmi lr, [r3], -r0, asr #31 │ │ │ │ ldmdavs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ subseq r7, fp, fp, lsl r8 │ │ │ │ ldmdahi fp, {r0, r1, r4, sl, lr} │ │ │ │ movwpl pc, #1027 @ 0x403 @ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ cmnvs fp, #0, 6 │ │ │ │ - bl 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0x2f4 │ │ │ │ - andeq sl, r4, r0, lsr #3 │ │ │ │ - @ instruction: 0x00040dba │ │ │ │ - andeq ip, r4, sl, lsr #14 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r0, r4, r8, ror #26 │ │ │ │ + andeq r9, r4, r0, lsr sl │ │ │ │ + andeq r0, r4, sl, ror #14 │ │ │ │ + andeq ip, r4, r2, lsr r0 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r0, r4, r8, lsl r7 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs sl!, {r0, r3, r4, r5, sp, lr} │ │ │ │ tstcc r0, #8060928 @ 0x7b0000 │ │ │ │ andsvs r6, r0, r8, lsl r8 │ │ │ │ strcc fp, [ip, -r0, lsl #30] │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ @@ -10831,42 +11334,42 @@ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, sl, fp, ip, lr} │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r7, ip, sp, lr}^ │ │ │ │ ldmdavs r9!, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ strmi pc, [r3], -r1, asr #24 │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq ip, r4, r2, asr r5 │ │ │ │ + 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5, cr11, [sp, #-512]! @ 0xfffffe00 │ │ │ │ adcslt r8, r4, r2, lsl #22 │ │ │ │ mvnsvs sl, r0, lsl #30 │ │ │ │ - bleq 149bd0 <__bss_end__@@Base+0xa2f98> │ │ │ │ - blne c9bd4 <__bss_end__@@Base+0x22f9c> │ │ │ │ - blcs 49bd8 │ │ │ │ + bleq 14a340 <__bss_end__@@Base+0xa37a0> │ │ │ │ + blne ca344 <__bss_end__@@Base+0x237a4> │ │ │ │ + blcs 4a348 │ │ │ │ bicge r6, r9, #1073741870 @ 0x4000002e │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ teqcs r2, #3260416 @ 0x31c000 │ │ │ │ @ instruction: 0xed9369fb │ │ │ │ - vldr d7, [pc, #16] @ e5e0 │ │ │ │ + vldr d7, [pc, #16] @ ed50 │ │ │ │ vmov.s16 r6, d23[2] │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmibvs fp!, {r4, r5, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 49c2c │ │ │ │ - bleq 120a0a4 <__bss_end__@@Base+0x116346c> │ │ │ │ - svc 0x006af7f4 │ │ │ │ - bleq bc9c08 <__bss_end__@@Base+0xb22fd0> │ │ │ │ - blvc bc9c4c <__bss_end__@@Base+0xb23014> │ │ │ │ - blvc 209e90 <__bss_end__@@Base+0x163258> │ │ │ │ - blvc b49c14 <__bss_end__@@Base+0xaa2fdc> │ │ │ │ + blvc 4a39c │ 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d6, d0 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ @ instruction: 0xf7f40b47 │ │ │ │ - cdp 13, 11, cr14, cr0, cr12, {3} │ │ │ │ + @ instruction: 0xeeb0e98e │ │ │ │ vldr d5, [r7, #256] @ 0x100 │ │ │ │ vdup.16 d6, r6 │ │ │ │ vstr d7, [r7, #20] │ │ │ │ vldr d7, [r7, #136] @ 0x88 │ │ │ │ - vldr d7, [pc, #192] @ e724 │ │ │ │ + vldr d7, [pc, #192] @ ee94 │ │ │ │ vmov.32 d23[1], r6 │ │ │ │ vldr d8, [r7, #24] │ │ │ │ - vldr d7, [pc, #176] @ e720 │ │ │ │ + vldr d7, [pc, #176] @ ee90 │ │ │ │ vmov.32 d23[1], r6 │ │ │ │ vmov.f64 d7, #118 @ 0x3fb00000 1.375 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vrintx.f64 d7, d7 │ │ │ │ vmov.f64 d1, #8 @ 0x40400000 3.0 │ │ │ │ @ instruction: 0xf7f40b47 │ │ │ │ - mrc 15, 5, lr, cr0, cr4, {3} │ │ │ │ + @ instruction: 0xeeb0eb8a │ │ │ │ @ instruction: 0xee886b40 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ @ instruction: 0xeeb77b20 │ │ │ │ vldr d5, [r7] │ │ │ │ vdiv.f64 d6, d5, d16 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #120] @ 0x78 │ │ │ │ @@ -11312,15 +11815,15 @@ │ │ │ │ @ instruction: 0xeeb07b28 │ │ │ │ vmul.f64 d6, d7, d8 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ vmul.f64 d7, d6, d24 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ - vldr d7, [pc, #176] @ e7ac │ │ │ │ + vldr d7, [pc, #176] @ ef1c │ │ │ │ vmov.16 d7[3], r5 │ │ │ │ vmov.f64 d7, #117 @ 0x3fa80000 1.3125000 │ │ │ │ vadd.f64 d5, d5, d0 │ │ │ │ vnmul.f64 d7, d6, d7 │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmov.u16 r7, d1[2] │ │ │ │ vmul.f64 d6, d7, d8 │ │ │ │ @@ -11354,88 +11857,88 @@ │ │ │ │ @ instruction: 0xed9369fb │ │ │ │ vldr d6, [r7] │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ @ instruction: 0xf7ff0b47 │ │ │ │ mrc 12, 5, APSR_nzcv, cr0, cr9, {3} │ │ │ │ ldmibvs fp!, {r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 49db0 │ │ │ │ - blvs 5c9e04 <__bss_end__@@Base+0x5231cc> │ │ │ │ - blpl 4a26c │ │ │ │ - blvc 18a1c8 <__bss_end__@@Base+0xe3590> │ │ │ │ - blvs 549e10 <__bss_end__@@Base+0x4a31d8> │ │ │ │ - blvc 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r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blvc 104aa9c <__bss_end__@@Base+0xfa3efc> │ │ │ │ + blvs 20aa00 <__bss_end__@@Base+0x163e60> │ │ │ │ + blpl 44a640 <__bss_end__@@Base+0x3a3aa0> │ │ │ │ + blvc 3ca644 <__bss_end__@@Base+0x323aa4> │ │ │ │ + blpl 20a880 <__bss_end__@@Base+0x163ce0> │ │ │ │ + blvc 3ca64c <__bss_end__@@Base+0x323aac> │ │ │ │ + blpl 20a888 <__bss_end__@@Base+0x163ce8> │ │ │ │ + blvc 24a654 <__bss_end__@@Base+0x1a3ab4> │ │ │ │ + blmi 20a890 <__bss_end__@@Base+0x163cf0> │ │ │ │ + blpl cca65c <__bss_end__@@Base+0xc23abc> │ │ │ │ + blvc 18aa14 <__bss_end__@@Base+0xe3e74> │ │ │ │ + blvc 20a8e0 <__bss_end__@@Base+0x163d40> │ │ │ │ @ instruction: 0xed8369bb │ │ │ │ ldmibvs fp!, {r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvs c9ef0 <__bss_end__@@Base+0x232b8> │ │ │ │ - blvc 249f04 <__bss_end__@@Base+0x1a32cc> │ │ │ │ - blvc 20a184 <__bss_end__@@Base+0x16354c> │ │ │ │ - bleq 120a370 <__bss_end__@@Base+0x1163738> │ │ │ │ + blvs ca660 <__bss_end__@@Base+0x23ac0> │ │ │ │ + blvc 24a674 <__bss_end__@@Base+0x1a3ad4> │ │ │ │ + blvc 20a8f4 <__bss_end__@@Base+0x163d54> │ │ │ │ + bleq 120aae0 <__bss_end__@@Base+0x1163f40> │ │ │ │ stc2 7, cr15, [ip], {255} @ 0xff │ │ │ │ - blvc 104a378 <__bss_end__@@Base+0xfa3740> │ │ │ │ + blvc 104aae8 <__bss_end__@@Base+0xfa3f48> │ │ │ │ @ instruction: 0xed8369fb │ │ │ │ svclt 0x00007b02 │ │ │ │ ssatmi r3, #30, r0, asr #15 │ │ │ │ - blhi c9bbc <__bss_end__@@Base+0x22f84> │ │ │ │ + blhi ca32c <__bss_end__@@Base+0x2378c> │ │ │ │ svclt 0x0000bd80 │ │ │ │ andmi r0, r0, r0 │ │ │ │ cmpmi r8, r6, lsr #9 │ │ │ │ vqrshrn.s64 d31, q12, #10 │ │ │ │ svccc 0x007b6b90 │ │ │ │ cdple 2, 1, cr1, cr10, cr13, {0} │ │ │ │ svccc 0x00efc928 │ │ │ │ @@ -11445,188 +11948,188 @@ │ │ │ │ cmnvs r8, r4, lsl #30 │ │ │ │ stc 1, cr6, [r7, #228] @ 0xe4 │ │ │ │ rsbsvs r0, sl, r2, lsl #22 │ │ │ │ ldmib r3, {r0, r1, r6, r7, r8, r9, sp, pc}^ │ │ │ │ stmib r7, {r8, r9, sp}^ │ │ │ │ ldc 3, cr2, [r7, #64] @ 0x40 │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ - vldr d7, [pc, #796] @ ec2c │ │ │ │ + vldr d7, [pc, #796] @ f39c │ │ │ │ vmov.u16 r6, d20[2] │ │ │ │ vneg.f64 d23, d6 │ │ │ │ stmdale r1!, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ - blvc c9f7c <__bss_end__@@Base+0x23344> │ │ │ │ - blvs febc9fa0 <__bss_end__@@Base+0xfeb23368> │ │ │ │ - blvc ff1ca3f8 <__bss_end__@@Base+0xff1237c0> │ │ │ │ - blx 44a4f0 <__bss_end__@@Base+0x3a38b8> │ │ │ │ + blvc ca6ec <__bss_end__@@Base+0x23b4c> │ │ │ │ + blvs febca710 <__bss_end__@@Base+0xfeb23b70> │ │ │ │ + blvc ff1cab68 <__bss_end__@@Base+0xff123fc8> │ │ │ │ + blx 44ac60 <__bss_end__@@Base+0x3a40c0> │ │ │ │ movwcs fp, #8108 @ 0x1fac │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ movweq pc, #4227 @ 0x1083 @ │ │ │ │ - blcs 3b4a8 │ │ │ │ + blcs 3bc18 │ │ │ │ ldc 1, cr13, [r7, #64] @ 0x40 │ │ │ │ - vldr d7, [pc, #8] @ e94c │ │ │ │ + vldr d7, [pc, #8] @ f0bc │ │ │ │ @ instruction: 0xeeb46ba8 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ svclt 0x0094fa10 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0xf083b2db │ │ │ │ sbcslt r0, fp, #67108864 @ 0x4000000 │ │ │ │ andle r2, ip, r0, lsl #22 │ │ │ │ ldmib r7, {r0, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ stmib sp, {r1, r8, r9, sp}^ │ │ │ │ - blmi fea9756c <__bss_end__@@Base+0xfe9f0934> │ │ │ │ + blmi fea97cdc <__bss_end__@@Base+0xfe9f113c> │ │ │ │ @ instruction: 0x461a447b │ │ │ │ @ instruction: 0xf7f46978 │ │ │ │ - ldmdbvs fp!, {r1, r6, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmdbvs fp!, {r1, r2, r3, r4, r6, r7, r8, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf04fe125 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ ldmdavs fp!, {r4, r8, r9, sp}^ │ │ │ │ vqdmulh.s d2, d0, d3 │ │ │ │ andge r8, r2, #16, 2 │ │ │ │ eorcc pc, r3, r2, asr r8 @ │ │ │ │ @ instruction: 0x4710441a │ │ │ │ andeq r0, r0, r1, lsl r0 │ │ │ │ andeq r0, r0, r7, lsl r1 │ │ │ │ muleq r0, sp, r1 │ │ │ │ andeq r0, r0, pc, ror #3 │ │ │ │ - blvc ca008 <__bss_end__@@Base+0x233d0> │ │ │ │ - blvc ff04a484 <__bss_end__@@Base+0xfefa384c> │ │ │ │ - blx 44a578 <__bss_end__@@Base+0x3a3940> │ │ │ │ + blvc ca778 <__bss_end__@@Base+0x23bd8> │ │ │ │ + blvc ff04abf4 <__bss_end__@@Base+0xfefa4054> │ │ │ │ + blx 44ace8 <__bss_end__@@Base+0x3a4148> │ │ │ │ movtcs sp, #60161 @ 0xeb01 │ │ │ │ cmpcs r3, #0 │ │ │ │ eorscc pc, pc, r7, lsl #17 │ │ │ │ - blvc ca020 <__bss_end__@@Base+0x233e8> │ │ │ │ - blvc ff20a488 <__bss_end__@@Base+0xff163850> │ │ │ │ - blvs fe24a048 <__bss_end__@@Base+0xfe1a3410> │ │ │ │ - blvs 1ca26c <__bss_end__@@Base+0x123634> │ │ │ │ - blpl fe24a050 <__bss_end__@@Base+0xfe1a3418> │ │ │ │ - blvc 18a3f0 <__bss_end__@@Base+0xe37b8> │ │ │ │ - blvs fe24a058 <__bss_end__@@Base+0xfe1a3420> │ │ │ │ - blvc 1ca27c <__bss_end__@@Base+0x123644> │ │ │ │ - blvs 4a4bc │ │ │ │ - blvc 1ca2c4 <__bss_end__@@Base+0x12368c> │ │ │ │ - blvc ff20a5e0 <__bss_end__@@Base+0xff1639a8> │ │ │ │ - bcc fe44a24c <__bss_end__@@Base+0xfe3a3614> │ │ │ │ + blvc ca790 <__bss_end__@@Base+0x23bf0> │ │ │ │ + blvc ff20abf8 <__bss_end__@@Base+0xff164058> │ │ │ │ + blvs fe24a7b8 <__bss_end__@@Base+0xfe1a3c18> │ │ │ │ + blvs 1ca9dc <__bss_end__@@Base+0x123e3c> │ │ │ │ + blpl fe24a7c0 <__bss_end__@@Base+0xfe1a3c20> │ │ │ │ + blvc 18ab60 <__bss_end__@@Base+0xe3fc0> │ │ │ │ + blvs fe24a7c8 <__bss_end__@@Base+0xfe1a3c28> │ │ │ │ + blvc 1ca9ec <__bss_end__@@Base+0x123e4c> │ │ │ │ + blvs 4ac2c │ │ │ │ + blvc 1caa34 <__bss_end__@@Base+0x123e94> │ │ │ │ + blvc ff20ad50 <__bss_end__@@Base+0xff1641b0> │ │ │ │ + bcc fe44a9bc <__bss_end__@@Base+0xfe3a3e1c> │ │ │ │ ldclvs 4, cr6, [sl], #1004 @ 0x3ec │ │ │ │ bicmi pc, r5, #1325400064 @ 0x4f000000 │ │ │ │ mvnne pc, #192, 4 │ │ │ │ stcle 2, cr4, [r4, #-616] @ 0xfffffd98 │ │ │ │ bicmi pc, r5, #1325400064 @ 0x4f000000 │ │ │ │ mvnne pc, #192, 4 │ │ │ │ ldclvs 4, cr6, [sl], #1004 @ 0x3ec │ │ │ │ mvnpl pc, #81788928 @ 0x4e00000 │ │ │ │ teqppl r4, #206569472 @ p-variant is OBSOLETE @ 0xc500000 │ │ │ │ movwne pc, #11139 @ 0x2b83 @ │ │ │ │ @ instruction: 0x17d31459 │ │ │ │ rscsvs r1, fp, #831488 @ 0xcb000 │ │ │ │ vpmin.s8 q11, q12, q13 │ │ │ │ @ instruction: 0xf6cf13c0 │ │ │ │ - blx aba16 <__bss_end__@@Base+0x4dde> │ │ │ │ + blx ac186 <__bss_end__@@Base+0x55e6> │ │ │ │ ldclvs 3, cr15, [sl], #12 │ │ │ │ ldrbtvs r4, [fp], #1043 @ 0x413 │ │ │ │ @ instruction: 0xf6416cfa │ │ │ │ vrsra.s64 , , #64 │ │ │ │ - blx fe0e381a <__bss_end__@@Base+0xfe03cbe2> │ │ │ │ + blx fe0e3f8a <__bss_end__@@Base+0xfe03d3ea> │ │ │ │ bicsne r1, r9, r2, lsl #6 │ │ │ │ - bne ff2d4994 <__bss_end__@@Base+0xff22dd5c> │ │ │ │ + bne ff2d5104 <__bss_end__@@Base+0xff22e564> │ │ │ │ ldmibvs sl!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ orrseq pc, r0, #81788928 @ 0x4e00000 │ │ │ │ mvnsvc pc, #217055232 @ 0xcf00000 │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldrmi r6, [r3], #-3322 @ 0xfffff306 │ │ │ │ ldmdbvs ip!, {r0, r1, r3, r4, r5, r6, r7, sl, sp, lr} │ │ │ │ vfma.f32 q11, q12, q13 │ │ │ │ vorr.i32 d21, #24320 @ 0x00005f00 │ │ │ │ - blx fe0d3a1a <__bss_end__@@Base+0xfe02cde2> │ │ │ │ + blx fe0d418a <__bss_end__@@Base+0xfe02d5ea> │ │ │ │ cmpne r9, r2, lsl #6 │ │ │ │ - bne ff2549c0 <__bss_end__@@Base+0xff1add88> │ │ │ │ + bne ff255130 <__bss_end__@@Base+0xff1ae590> │ │ │ │ vfma.f32 q11, q12, q13 │ │ │ │ vorr.i32 d21, #24320 @ 0x00005f00 │ │ │ │ - blx fe0d3a2e <__bss_end__@@Base+0xfe02cdf6> │ │ │ │ + blx fe0d419e <__bss_end__@@Base+0xfe02d5fe> │ │ │ │ cmpne r8, r2, lsl #6 │ │ │ │ - bne ff0d49d4 <__bss_end__@@Base+0xff02dd9c> │ │ │ │ - blx 16c1e │ │ │ │ - bne ff50b69c <__bss_end__@@Base+0xff464a64> │ │ │ │ + bne ff0d5144 <__bss_end__@@Base+0xff02e5a4> │ │ │ │ + blx 1738e │ │ │ │ + bne ff50be0c <__bss_end__@@Base+0xff46526c> │ │ │ │ mlascs pc, r7, r8, pc @ │ │ │ │ movwls r9, #8707 @ 0x2203 │ │ │ │ ldmibvs fp!, {r0, r8, ip, pc}^ │ │ │ │ - bvs ffef36a0 <__bss_end__@@Base+0xffe4ca68> │ │ │ │ + bvs ffef3e10 <__bss_end__@@Base+0xffe4d270> │ │ │ │ ldrbtmi r4, [sl], #-2653 @ 0xfffff5a3 │ │ │ │ ldmdbvs r8!, {r0, r5, r9, sl, lr}^ │ │ │ │ - stc 7, cr15, [r6, #-976]! @ 0xfffffc30 │ │ │ │ + stmdb r2, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldc 0, cr14, [r7, #552] @ 0x228 │ │ │ │ vmov.f64 d7, #82 @ 0x3e900000 0.2812500 │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ - blle 8d2fc <__bss_start@@Base+0x3225c> │ │ │ │ + blle 8da6c <__bss_start@@Base+0x32a64> │ │ │ │ and r2, r0, lr, asr #6 │ │ │ │ @ instruction: 0xf8872353 │ │ │ │ ldc 0, cr3, [r7, #252] @ 0xfc │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ - vldr d7, [pc, #796] @ edec │ │ │ │ + vldr d7, [pc, #796] @ f55c │ │ │ │ vnmul.f64 d6, d7, d7 │ │ │ │ - vldr d6, [pc, #24] @ eaf0 │ │ │ │ + vldr d6, [pc, #24] @ f260 │ │ │ │ @ instruction: 0xee865b47 │ │ │ │ vldr d7, [r7, #20] │ │ │ │ vmov.32 r6, d6[1] │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #48] @ 0x30 │ │ │ │ vmov.f64 d23, #220 @ 0xbee00000 -0.4375000 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ rscsvs r3, fp, #144, 20 @ 0x90000 │ │ │ │ @ instruction: 0xee076afb │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ vldr d7, [r7, #924] @ 0x39c │ │ │ │ vadd.f64 d6, d6, d12 │ │ │ │ - vldr d7, [pc, #284] @ ec28 │ │ │ │ + vldr d7, [pc, #284] @ f398 │ │ │ │ vmov.16 d7[2], r6 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmdbvs r9!, {r3, r8, r9, fp, ip, sp, lr} │ │ │ │ mlascc pc, r7, r8, pc @ │ │ │ │ ldmib r7, {r1, r8, r9, ip, pc}^ │ │ │ │ stmib sp, {r3, r8, r9, sp}^ │ │ │ │ - bvs ffed7728 <__bss_end__@@Base+0xffe30af0> │ │ │ │ + bvs ffed7e98 <__bss_end__@@Base+0xffe312f8> │ │ │ │ ldrbtmi r4, [sl], #-2620 @ 0xfffff5c4 │ │ │ │ @ instruction: 0xf7f46978 │ │ │ │ - sub lr, r7, r4, ror #25 │ │ │ │ - blvc ca194 <__bss_end__@@Base+0x2355c> │ │ │ │ - blvc ff04a610 <__bss_end__@@Base+0xfefa39d8> │ │ │ │ - blx 44a704 <__bss_end__@@Base+0x3a3acc> │ │ │ │ + sub lr, r7, r0, lsl #18 │ │ │ │ + blvc ca904 <__bss_end__@@Base+0x23d64> │ │ │ │ + blvc ff04ad80 <__bss_end__@@Base+0xfefa41e0> │ │ │ │ + blx 44ae74 <__bss_end__@@Base+0x3a42d4> │ │ │ │ movtcs sp, #60161 @ 0xeb01 │ │ │ │ cmpcs r3, #0 │ │ │ │ eorscc pc, pc, r7, lsl #17 │ │ │ │ - blvc ca1ac <__bss_end__@@Base+0x23574> │ │ │ │ - blvc ff20a614 <__bss_end__@@Base+0xff1639dc> │ │ │ │ - blvs 98a1d4 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│ │ + andeq pc, r3, r6, lsr #21 │ │ │ │ addslt fp, r8, r0, lsl #11 │ │ │ │ cmnvs r8, r4, lsl #30 │ │ │ │ stc 1, cr6, [r7, #228] @ 0xe4 │ │ │ │ rsbsvs r0, sl, r2, lsl #22 │ │ │ │ ldmib r3, {r1, r2, r3, r4, r5, r7, r8, r9, sp, pc}^ │ │ │ │ stmib r7, {r8, r9, sp}^ │ │ │ │ ldc 3, cr2, [r7, #64] @ 0x40 │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ - vldr d7, [pc, #796] @ ef70 │ │ │ │ + vldr d7, [pc, #796] @ f6e0 │ │ │ │ @ instruction: 0xeeb46bae │ │ │ │ vneg.f64 d23, d6 │ │ │ │ stmdale r1!, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ - blvc ca2c0 <__bss_end__@@Base+0x23688> │ │ │ │ - blvs feb0a2e4 <__bss_end__@@Base+0xfea636ac> │ │ │ │ - blvc ff1ca73c <__bss_end__@@Base+0xff123b04> │ │ │ │ - blx 44a834 <__bss_end__@@Base+0x3a3bfc> │ │ │ │ + blvc caa30 <__bss_end__@@Base+0x23e90> │ │ │ │ + blvs feb0aa54 <__bss_end__@@Base+0xfea63eb4> │ │ │ │ + blvc ff1caeac <__bss_end__@@Base+0xff12430c> │ │ │ │ + blx 44afa4 <__bss_end__@@Base+0x3a4404> │ │ │ │ movwcs fp, #8108 @ 0x1fac │ │ │ │ sbcslt r2, fp, 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0x544f @ │ │ │ │ bicscc pc, ip, #192, 4 │ │ │ │ ldclvs 4, cr6, [sl], #1004 @ 0x3ec │ │ │ │ mvnpl pc, #81788928 @ 0x4e00000 │ │ │ │ teqppl r4, #206569472 @ p-variant is OBSOLETE @ 0xc500000 │ │ │ │ movwne pc, #11139 @ 0x2b83 @ │ │ │ │ @ instruction: 0x17d31459 │ │ │ │ rscsvs r1, fp, #831488 @ 0xcb000 │ │ │ │ vpmin.s8 q11, q12, q13 │ │ │ │ @ instruction: 0xf6cf13c0 │ │ │ │ - blx abd5a <__bss_end__@@Base+0x5122> │ │ │ │ + blx ac4ca <__bss_end__@@Base+0x592a> │ │ │ │ ldclvs 3, cr15, [sl], #12 │ │ │ │ ldrbtvs r4, [fp], #1043 @ 0x413 │ │ │ │ @ instruction: 0xf6416cfa │ │ │ │ vrsra.s64 , , #64 │ │ │ │ - blx fe0e3b5e <__bss_end__@@Base+0xfe03cf26> │ │ │ │ + blx fe0e42ce <__bss_end__@@Base+0xfe03d72e> │ │ │ │ bicsne r1, r9, r2, lsl #6 │ │ │ │ - bne ff2d4cd8 <__bss_end__@@Base+0xff22e0a0> │ │ │ │ + bne ff2d5448 <__bss_end__@@Base+0xff22e8a8> │ │ │ │ ldmibvs sl!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ orrseq pc, r0, #81788928 @ 0x4e00000 │ │ │ │ mvnsvc pc, #217055232 @ 0xcf00000 │ │ │ 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instruction: 0x4619447a │ │ │ │ - @ instruction: 0xf7f46978 │ │ │ │ - and lr, sl, r8, lsl #22 │ │ │ │ - bmi 6a90dc <__bss_end__@@Base+0x6024a4> │ │ │ │ + @ instruction: 0xf7f36978 │ │ │ │ + and lr, sl, r4, lsr #30 │ │ │ │ + bmi 6a984c <__bss_end__@@Base+0x602cac> │ │ │ │ vqshl.s8 q10, q13, q0 │ │ │ │ ldmdami r9, {r0, r1, r2, r3, r4, r5, r8, ip} │ │ │ │ @ instruction: 0xf0034478 │ │ │ │ - @ instruction: 0xf7f4fc95 │ │ │ │ - ldmdbvs fp!, {r2, r5, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7f3fc95 │ │ │ │ + ldmdbvs fp!, {r2, r6, sl, fp, sp, lr, pc}^ │ │ │ │ smmlacc r0, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @ instruction: 0xffffffff │ │ │ │ svcvc 0x00efffff │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdgt r2, [r9], -fp │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ @@ -11843,91 +12346,91 @@ │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ tstpmi r5, r0, lsl #18 @ p-variant is OBSOLETE │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ strbtlt r1, [r8], #2895 @ 0xb4f │ │ │ │ svccc 0x004b4e81 │ │ │ │ - andeq pc, r3, r8, lsr #31 │ │ │ │ - ldrdeq pc, [r3], -lr │ │ │ │ - andeq pc, r3, ip, lsl #28 │ │ │ │ - andeq pc, r3, r8, asr #27 │ │ │ │ - andeq pc, r3, r8, lsr #27 │ │ │ │ - andeq pc, r3, r0, lsr #27 │ │ │ │ - @ instruction: 0x0003fdb8 │ │ │ │ + andeq pc, r3, r8, asr r9 @ │ │ │ │ + andeq pc, r3, lr, lsl #17 │ │ │ │ + @ instruction: 0x0003f7bc │ │ │ │ + andeq pc, r3, r8, ror r7 @ │ │ │ │ + andeq pc, r3, r8, asr r7 @ │ │ │ │ + andeq pc, r3, r0, asr r7 @ │ │ │ │ + andeq pc, r3, r8, ror #14 │ │ │ │ strdlt fp, [fp], r0 │ │ │ │ rscsvs sl, r8, r6, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r1, r2, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ ldmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmdavs ip!, {r1, r8}^ │ │ │ │ strmi lr, [r4, #-2516] @ 0xfffff62c │ │ │ │ strmi lr, [r4, #-2509] @ 0xfffff633 │ │ │ │ smlabteq r2, sp, r9, lr │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ ldrbtmi r4, [fp], #-2821 @ 0xfffff4fb │ │ │ │ @ instruction: 0x4631461a │ │ │ │ - @ instruction: 0xf7f468f8 │ │ │ │ - svclt 0x0000eab0 │ │ │ │ + @ instruction: 0xf7f368f8 │ │ │ │ + svclt 0x0000eecc │ │ │ │ ssatmi r3, #30, r4, lsl #14 │ │ │ │ svclt 0x0000bdf0 │ │ │ │ - andeq pc, r3, sl, asr #26 │ │ │ │ + strdeq pc, [r3], -sl │ │ │ │ adcslt fp, sl, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r4, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ - blvc 4a608 │ │ │ │ + blvc 4ad78 │ │ │ │ cmnpeq r4, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ mrc 8, 5, r6, cr0, cr10, {1} │ │ │ │ cmncs r3, r7, asr #22 │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r3, r7, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - blvc ca620 <__bss_end__@@Base+0x239e8> │ │ │ │ + blvc cad90 <__bss_end__@@Base+0x241f0> │ │ │ │ tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ mrc 8, 5, r6, cr0, cr10, {1} │ │ │ │ cmncs r3, r7, asr #22 │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ ldmvs r9!, {r0, r2, r5, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf1072304 │ │ │ │ stmib sp, {r2, r4, r5, r6}^ │ │ │ │ @ instruction: 0xf1072302 │ │ │ │ movwls r0, #784 @ 0x310 │ │ │ │ - bmi 12080c <__bss_end__@@Base+0x79bd4> │ │ │ │ + bmi 120f7c <__bss_end__@@Base+0x7a3dc> │ │ │ │ ldmvs r8!, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - b 1e4cfd8 <__bss_end__@@Base+0x1da63a0> │ │ │ │ + mrc 7, 4, APSR_nzcv, cr4, cr3, {7} │ │ │ │ ldrbcc fp, [r8, r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - strdeq pc, [r3], -r0 │ │ │ │ + andeq pc, r3, r0, lsr #13 │ │ │ │ addslt fp, sl, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xa3bd6039 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ tstcs r4, #3260416 @ 0x31c000 │ │ │ │ ldmib r3, {r2, r3, r4, r5, r7, r8, r9, sp, pc}^ │ │ │ │ stmib r7, {r8, r9, sp}^ │ │ │ │ ldmdavs fp!, {r1, r4, r8, r9, sp}^ │ │ │ │ - blvs 4a684 │ │ │ │ + blvs 4adf4 │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmul.f64 d7, d6, d0 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ - blpl ca694 <__bss_end__@@Base+0x23a5c> │ │ │ │ + blpl cae04 <__bss_end__@@Base+0x24264> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmul.f64 d7, d5, d2 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ - @ instruction: 0xf7f40b47 │ │ │ │ - stc 8, cr14, [r7, #400] @ 0x190 │ │ │ │ + @ instruction: 0xf7f30b47 │ │ │ │ + stc 12, cr14, [r7, #536] @ 0x218 │ │ │ │ ldmdavs fp!, {r4, r8, r9, fp}^ │ │ │ │ movwcs lr, #18899 @ 0x49d3 │ │ │ │ movwcs lr, #59847 @ 0xe9c7 │ │ │ │ - blvc 44a6cc <__bss_end__@@Base+0x3a3a94> │ │ │ │ - blvc 104ab48 <__bss_end__@@Base+0xfa3f10> │ │ │ │ - blx 44ac3c <__bss_end__@@Base+0x3a4004> │ │ │ │ + blvc 44ae3c <__bss_end__@@Base+0x3a429c> │ │ │ │ + blvc 104b2b8 <__bss_end__@@Base+0xfa4718> │ │ │ │ + blx 44b3ac <__bss_end__@@Base+0x3a480c> │ │ │ │ ldc 1, cr13, [r7, #112] @ 0x70 │ │ │ │ vmov.f64 d7, #94 @ 0x3ef00000 0.4687500 │ │ │ │ vneg.f64 d23, d0 │ │ │ │ tstple r5, r0, lsl sl @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf04f6839 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r1, {r8, r9}^ │ │ │ │ @@ -11935,51 +12438,51 @@ │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #10689 @ 0x29c1 │ │ │ │ @ instruction: 0xf04f6839 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r1, {r8, r9}^ │ │ │ │ tst fp, r4, lsl #6 │ │ │ │ - blvc 44a714 <__bss_end__@@Base+0x3a3adc> │ │ │ │ - blvs 20a958 <__bss_end__@@Base+0x163d20> │ │ │ │ - blvc 3ca71c <__bss_end__@@Base+0x323ae4> │ │ │ │ - blvc 20a960 <__bss_end__@@Base+0x163d28> │ │ │ │ - blvc 20a9a0 <__bss_end__@@Base+0x163d68> │ │ │ │ - bleq 120ab8c <__bss_end__@@Base+0x1163f54> │ │ │ │ - stmda sl!, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blpl 104ab94 <__bss_end__@@Base+0xfa3f5c> │ │ │ │ - blvs 3ca734 <__bss_end__@@Base+0x323afc> │ │ │ │ - blvc 18aaf4 <__bss_end__@@Base+0xe3ebc> │ │ │ │ - blvc 64a6fc <__bss_end__@@Base+0x5a3ac4> │ │ │ │ + blvc 44ae84 <__bss_end__@@Base+0x3a42e4> │ │ │ │ + blvs 20b0c8 <__bss_end__@@Base+0x164528> │ │ │ │ + blvc 3cae8c <__bss_end__@@Base+0x3242ec> │ │ │ │ + blvc 20b0d0 <__bss_end__@@Base+0x164530> │ │ │ │ + blvc 20b110 <__bss_end__@@Base+0x164570> │ │ │ │ + bleq 120b2fc <__bss_end__@@Base+0x116475c> │ │ │ │ + mcrr 7, 15, pc, ip, cr3 @ │ │ │ │ + blpl 104b304 <__bss_end__@@Base+0xfa4764> │ │ │ │ + blvs 3caea4 <__bss_end__@@Base+0x324304> │ │ │ │ + blvc 18b264 <__bss_end__@@Base+0xe46c4> │ │ │ │ + blvc 64ae6c <__bss_end__@@Base+0x5a42cc> │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ tstcs r6, #3260416 @ 0x31c000 │ │ │ │ ldc 0, cr14, [r7, #548] @ 0x224 │ │ │ │ vmov.32 d7[1], r7 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vmov.f64 d7, #120 @ 0x3fc00000 1.5 │ │ │ │ vldr d6, [r7] │ │ │ │ vadd.f64 d7, d6, d8 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ - @ instruction: 0xf7f40b47 │ │ │ │ - stc 8, cr14, [r7, #40] @ 0x28 │ │ │ │ + @ instruction: 0xf7f30b47 │ │ │ │ + stc 12, cr14, [r7, #176] @ 0xb0 │ │ │ │ vldr d0, [r7, #24] │ │ │ │ - vldr d7, [pc, #96] @ f17c │ │ │ │ + vldr d7, [pc, #96] @ f8ec │ │ │ │ vmov.16 d7[3], r6 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ vmov.32 d6[1], r7 │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vldr d5, [r7, #80] @ 0x50 │ │ │ │ vmov.32 d5[1], r7 │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmul.f64 d7, d5, d6 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ - vldr d7, [pc, #24] @ f160 │ │ │ │ + vldr d7, [pc, #24] @ f8d0 │ │ │ │ vnmul.f64 d5, d7, d29 │ │ │ │ vldr d5, [r7, #20] │ │ │ │ vmul.f64 d7, d5, d14 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ vldr d5, [r7, #72] @ 0x48 │ │ │ │ vmul.f64 d7, d5, d6 │ │ │ │ @@ -11991,28 +12494,28 @@ │ │ │ │ vldr d7, [r7, #16] │ │ │ │ vldr d6, [r7, #80] @ 0x50 │ │ │ │ vmul.f64 d7, d6, d8 │ │ │ │ vadd.f64 d7, d7, d7 │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vldr d6, [r7, #28] │ │ │ │ - vldr d7, [pc, #64] @ f1d8 │ │ │ │ + vldr d7, [pc, #64] @ f948 │ │ │ │ @ instruction: 0xee275b57 │ │ │ │ vldr d5, [r7, #20] │ │ │ │ vmul.f64 d7, d5, d8 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vmov.32 r7, d7[1] │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmul.f64 d7, d5, d8 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ - vldr d7, [pc, #96] @ f22c │ │ │ │ + vldr d7, [pc, #96] @ f99c │ │ │ │ vnmul.f64 d5, d7, d12 │ │ │ │ vldr d5, [r7, #20] │ │ │ │ vmul.f64 d7, d5, d14 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vadd.f64 d7, d7, d7 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #8] │ │ │ │ @@ -12021,30 +12524,30 @@ │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #88] @ 0x58 │ │ │ │ vldr d6, [r7, #96] @ 0x60 │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vstr d7, [r7, #284] @ 0x11c │ │ │ │ vldr d7, [r7, #96] @ 0x60 │ │ │ │ vmov.32 r7, d0[1] │ │ │ │ - vldr d7, [pc, #796] @ f52c │ │ │ │ + vldr d7, [pc, #796] @ fc9c │ │ │ │ vmov.u16 r6, d4[2] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ @ instruction: 0xf73ffa10 │ │ │ │ ldc 15, cr10, [r7, #424] @ 0x1a8 │ │ │ │ - vldr d7, [pc, #96] @ f284 │ │ │ │ + vldr d7, [pc, #96] @ f9f4 │ │ │ │ vmov.16 d7[2], r6 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #48] @ 0x30 │ │ │ │ vmov.32 d7[1], r7 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ @ instruction: 0xf7f30b47 │ │ │ │ - mrc 15, 5, lr, cr0, cr0, {3} │ │ │ │ - vldr d7, [pc, #256] @ f34c │ │ │ │ + vmov.32 lr, d16[1] │ │ │ │ + vldr d7, [pc, #256] @ fabc │ │ │ │ vmul.f64 d6, d7, d26 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #40] @ 0x28 │ │ │ │ vldr d6, [r7, #56] @ 0x38 │ │ │ │ vadd.f64 d7, d6, d12 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ vldr d5, [r7, #56] @ 0x38 │ │ │ │ @@ -12056,108 +12559,108 @@ │ │ │ │ vldr d5, [r7, #284] @ 0x11c │ │ │ │ vldr d4, [r7, #64] @ 0x40 │ │ │ │ vadd.f64 d7, d4, d10 │ │ │ │ vnmul.f64 d7, d5, d7 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ @ instruction: 0xf7f30b47 │ │ │ │ - cdp 15, 11, cr14, cr0, cr6, {2} │ │ │ │ + vmov.f64 d14, d24 │ │ │ │ ldmdavs fp!, {r6, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 14a8b0 <__bss_end__@@Base+0xa3c78> │ │ │ │ - blvc 2ca904 <__bss_end__@@Base+0x223ccc> │ │ │ │ - blvs 64a928 <__bss_end__@@Base+0x5a3cf0> │ │ │ │ - blvc 1cab4c <__bss_end__@@Base+0x123f14> │ │ │ │ - blvs 34a910 <__bss_end__@@Base+0x2a3cd8> │ │ │ │ - blpl 20acd0 <__bss_end__@@Base+0x164098> │ │ │ │ - bleq 118ad7c <__bss_end__@@Base+0x10e4144> │ │ │ │ - svc 0x0056f7f3 │ │ │ │ - blvc 104ad84 <__bss_end__@@Base+0xfa414c> │ │ │ │ + blvc 14b020 <__bss_end__@@Base+0xa4480> │ │ │ │ + blvc 2cb074 <__bss_end__@@Base+0x2244d4> │ │ │ │ + blvs 64b098 <__bss_end__@@Base+0x5a44f8> │ │ │ │ + blvc 1cb2bc <__bss_end__@@Base+0x12471c> │ │ │ │ + blvs 34b080 <__bss_end__@@Base+0x2a44e0> │ │ │ │ + blpl 20b440 <__bss_end__@@Base+0x1648a0> │ │ │ │ + bleq 118b4ec <__bss_end__@@Base+0x10e494c> │ │ │ │ + bl 1e4d9fc <__bss_end__@@Base+0x1da6e5c> │ │ │ │ + blvc 104b4f4 <__bss_end__@@Base+0xfa4954> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ ldmdavs fp!, {r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc ca91c <__bss_end__@@Base+0x23ce4> │ │ │ │ + blvc cb08c <__bss_end__@@Base+0x244ec> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d6, #0 @ 0x40000000 2.0 │ │ │ │ vmov.f64 d1, d6 │ │ │ │ - @ instruction: 0xf7f40b47 │ │ │ │ - cdp 8, 11, cr14, cr0, cr10, {4} │ │ │ │ + @ instruction: 0xf7f30b47 │ │ │ │ + cdp 12, 11, cr14, cr0, cr6, {5} │ │ │ │ ldmdavs fp!, {r6, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc ca8f8 <__bss_end__@@Base+0x23cc0> │ │ │ │ + blvc cb068 <__bss_end__@@Base+0x244c8> │ │ │ │ ldrtmi r3, [sp], r8, ror #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ andmi r0, r0, r0 │ │ │ │ cmpmi r8, r6, lsr #9 │ │ │ │ ldrne sp, [fp], #-2641 @ 0xfffff5af │ │ │ │ cmpmi r8, r4, asr #31 │ │ │ │ ldmdb fp, {r4, r5, r6, r8, r9, fp} │ │ │ │ mcrcc 14, 0, r7, cr0, cr15, {0} │ │ │ │ cdple 2, 1, cr1, cr10, cr13, {0} │ │ │ │ svccc 0x00efc928 │ │ │ │ - stcmi 8, cr11, [pc], #-512 @ f118 │ │ │ │ + stcmi 8, cr11, [pc], #-512 @ f888 │ │ │ │ sbcmi r7, r2, #868 @ 0x364 │ │ │ │ vfmacs.f64 d22, d26, d7 │ │ │ │ sbcmi r6, r2, #37 @ 0x25 │ │ │ │ stc 5, cr11, [sp, #-512]! @ 0xfffffe00 │ │ │ │ addlt r8, sl, r2, lsl #22 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - blvc 4a984 │ │ │ │ - bleq 120adfc <__bss_end__@@Base+0x11641c4> │ │ │ │ - ldm lr!, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - bleq 24a960 <__bss_end__@@Base+0x1a3d28> │ │ │ │ + blvc 4b0f4 │ │ │ │ + bleq 120b56c <__bss_end__@@Base+0x11649cc> │ │ │ │ + ldcl 7, cr15, [sl], {243} @ 0xf3 │ │ │ │ + bleq 24b0d0 <__bss_end__@@Base+0x1a4530> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d7, #0 @ 0x40000000 2.0 │ │ │ │ @ instruction: 0xf7f30b47 │ │ │ │ - stc 15, cr14, [r7, #392] @ 0x188 │ │ │ │ + vstr d14, [r7, #536] @ 0x218 │ │ │ │ vldr d0, [r7, #24] │ │ │ │ - vldr d7, [pc, #32] @ f37c │ │ │ │ + vldr d7, [pc, #32] @ faec │ │ │ │ vmov.16 d7[2], r6 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ vmul.f64 d7, d6, d8 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ @ instruction: 0xf7f30b47 │ │ │ │ - mrc 14, 5, lr, cr0, cr6, {6} │ │ │ │ - vldr d6, [pc, #256] @ f480 │ │ │ │ + @ instruction: 0xeeb0eaf8 │ │ │ │ + vldr d6, [pc, #256] @ fbf0 │ │ │ │ vdiv.f64 d5, d5, d25 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmdavs fp!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 14a9dc <__bss_end__@@Base+0xa3da4> │ │ │ │ - blvs 14a9f0 <__bss_end__@@Base+0xa3db8> │ │ │ │ - blvc 20ac70 <__bss_end__@@Base+0x164038> │ │ │ │ - blvc ca9b8 <__bss_end__@@Base+0x23d80> │ │ │ │ - blvs ca9fc <__bss_end__@@Base+0x23dc4> │ │ │ │ - blvc 1caa00 <__bss_end__@@Base+0x123dc8> │ │ │ │ - blhi 20ac40 <__bss_end__@@Base+0x164008> │ │ │ │ + blvc 14b14c <__bss_end__@@Base+0xa45ac> │ │ │ │ + blvs 14b160 <__bss_end__@@Base+0xa45c0> │ │ │ │ + blvc 20b3e0 <__bss_end__@@Base+0x164840> │ │ │ │ + blvc cb128 <__bss_end__@@Base+0x24588> │ │ │ │ + blvs cb16c <__bss_end__@@Base+0x245cc> │ │ │ │ + blvc 1cb170 <__bss_end__@@Base+0x1245d0> │ │ │ │ + blhi 20b3b0 <__bss_end__@@Base+0x164810> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ @ instruction: 0xf7f30b47 │ │ │ │ - mrc 15, 5, lr, cr0, cr0, {1} │ │ │ │ + @ instruction: 0xeeb0eb54 │ │ │ │ vnmul.f64 d7, d8, d0 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 4a9d0 │ │ │ │ - blvs caa24 <__bss_end__@@Base+0x23dec> │ │ │ │ - blvc 1caa28 <__bss_end__@@Base+0x123df0> │ │ │ │ - blhi 20ac68 <__bss_end__@@Base+0x164030> │ │ │ │ + blvc 4b140 │ │ │ │ + blvs cb194 <__bss_end__@@Base+0x245f4> │ │ │ │ + blvc 1cb198 <__bss_end__@@Base+0x1245f8> │ │ │ │ + blhi 20b3d8 <__bss_end__@@Base+0x164838> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ - @ instruction: 0xf7f40b47 │ │ │ │ - mrc 8, 5, lr, cr0, cr0, {3} │ │ │ │ + @ instruction: 0xf7f30b47 │ │ │ │ + cdp 12, 11, cr14, cr0, cr12, {4} │ │ │ │ vnmul.f64 d7, d8, d0 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc ca9f8 <__bss_end__@@Base+0x23dc0> │ │ │ │ - blvc 14aa4c <__bss_end__@@Base+0xa3e14> │ │ │ │ - blvs 3caa70 <__bss_end__@@Base+0x323e38> │ │ │ │ - blvs 1cac94 <__bss_end__@@Base+0x12405c> │ │ │ │ + blvc cb168 <__bss_end__@@Base+0x245c8> │ │ │ │ + blvc 14b1bc <__bss_end__@@Base+0xa461c> │ │ │ │ + blvs 3cb1e0 <__bss_end__@@Base+0x324640> │ │ │ │ + blvs 1cb404 <__bss_end__@@Base+0x124864> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vadd.f64 d7, d6, d4 │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vmul.f64 d7, d6, d8 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 14aa1c <__bss_end__@@Base+0xa3de4> │ │ │ │ + blvc 14b18c <__bss_end__@@Base+0xa45ec> │ │ │ │ strcc fp, [r8, -r0, lsl #30]! │ │ │ │ ldc 6, cr4, [sp], #756 @ 0x2f4 │ │ │ │ vstrlt d8, [r0, #8] │ │ │ │ vqrshrn.s64 d31, q12, #10 │ │ │ │ svccc 0x007b6b90 │ │ │ │ andmi r0, r0, r0 │ │ │ │ cmpmi r8, r6, lsr #9 │ │ │ │ @@ -12167,70 +12670,70 @@ │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ andle r2, r6, r0, lsl #22 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ ldrsbtvs r6, [fp], #139 @ 0x8b │ │ │ │ ldmdavs fp!, {r0, r4, sp, lr, pc}^ │ │ │ │ - blcs 294c4 │ │ │ │ + blcs 29c34 │ │ │ │ ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ mrrcne 8, 1, r6, r9, cr11 │ │ │ │ andsvs r6, r1, sl, ror r8 │ │ │ │ rscsvs r7, fp, fp, lsl r8 │ │ │ │ ldmdavs fp!, {r0, r2, sp, lr, pc}^ │ │ │ │ @ instruction: 0x4618685b │ │ │ │ - svc 0x000ef7f3 │ │ │ │ + bl ccdbb0 <__bss_end__@@Base+0xc27010> │ │ │ │ ldmvs fp!, {r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @ instruction: 0xb082b5b0 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blmi fe8d888c <__bss_end__@@Base+0xfe831c54> │ │ │ │ + blmi fe8d8ffc <__bss_end__@@Base+0xfe83245c> │ │ │ │ andcs r4, r0, #2063597568 @ 0x7b000000 │ │ │ │ teq r3, sl, lsl r0 │ │ │ │ andle r2, r8, r0, lsl #26 │ │ │ │ vqdmull.s q9, d0, d0 │ │ │ │ strtmi r8, [fp], -r2, lsr #2 │ │ │ │ - blcs 5e0ac <__bss_start@@Base+0x300c> │ │ │ │ + blcs 5e81c <__bss_start@@Base+0x3814> │ │ │ │ tstphi sp, r0, lsl #4 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7f3e0c0 │ │ │ │ - strmi lr, [r3], -lr, ror #30 │ │ │ │ + @ instruction: 0x4603eb92 │ │ │ │ @ instruction: 0x4623681a │ │ │ │ ldrmi r0, [r3], #-91 @ 0xffffffa5 │ │ │ │ vst2.8 {d8-d9}, [r3 :64], fp │ │ │ │ - blcs 240c0 │ │ │ │ + blcs 24830 │ │ │ │ tstphi fp, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ - svc 0x0060f7f3 │ │ │ │ + bl fe14dc04 <__bss_end__@@Base+0xfe0a7064> │ │ │ │ ldmdavs sl, {r0, r1, r9, sl, lr} │ │ │ │ subseq r4, fp, r3, lsr #12 │ │ │ │ ldmdahi fp, {r0, r1, r4, sl, lr} │ │ │ │ movwvs pc, #1027 @ 0x403 @ │ │ │ │ andle r2, ip, r0, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2959 @ 0xfffff471 │ │ │ │ mrrcne 8, 1, r6, r9, cr11 │ │ │ │ ldrbtmi r4, [sl], #-2702 @ 0xfffff572 │ │ │ │ rsclt r6, r1, #17 │ │ │ │ ldrbtmi r4, [sl], #-2701 @ 0xfffff573 │ │ │ │ strcs r5, [r2, #-1233] @ 0xfffffb2f │ │ │ │ stccs 1, cr14, [lr], #-8 │ │ │ │ - blmi fe30392c <__bss_end__@@Base+0xfe25ccf4> │ │ │ │ + blmi fe30409c <__bss_end__@@Base+0xfe25d4fc> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bmi fe296668 <__bss_end__@@Base+0xfe1efa30> │ │ │ │ + bmi fe296dd8 <__bss_end__@@Base+0xfe1f0238> │ │ │ │ andsvs r4, r1, sl, ror r4 │ │ │ │ - bmi fe27c090 <__bss_end__@@Base+0xfe1d5458> │ │ │ │ + bmi fe27c800 <__bss_end__@@Base+0xfe1d5c60> │ │ │ │ ldrbpl r4, [r1], #1146 @ 0x47a │ │ │ │ rscs r2, r3, r3, lsl #10 │ │ │ │ - blmi fe1fc0a0 <__bss_end__@@Base+0xfe155468> │ │ │ │ + blmi fe1fc810 <__bss_end__@@Base+0xfe155c70> │ │ │ │ andsvc r4, sl, fp, ror r4 │ │ │ │ ldrbtmi r4, [fp], #-2950 @ 0xfffff47a │ │ │ │ subsvc r2, sl, r0, lsl #4 │ │ │ │ rsbsle r2, r5, sp, lsr #24 │ │ │ │ - blle 1f5a5e0 <__bss_end__@@Base+0x1eb39a8> │ │ │ │ + blle 1f5ad50 <__bss_end__@@Base+0x1eb41b0> │ │ │ │ ldclle 12, cr2, [fp], #-476 @ 0xfffffe24 │ │ │ │ - blle 1e5a648 <__bss_end__@@Base+0x1db3a10> │ │ │ │ + blle 1e5adb8 <__bss_end__@@Base+0x1db4218> │ │ │ │ movteq pc, #20900 @ 0x51a4 @ │ │ │ │ ldmdale r5!, {r1, r4, r5, r8, r9, fp, sp}^ │ │ │ │ @ instruction: 0xf852a202 │ │ │ │ ldrmi r3, [sl], #-35 @ 0xffffffdd │ │ │ │ svclt 0x00004710 │ │ │ │ ldrdeq r0, [r0], -r5 │ │ │ │ andeq r0, r0, r1, ror #1 │ │ │ │ @@ -12285,94 +12788,94 @@ │ │ │ │ ldrdeq r0, [r0], -sp │ │ │ │ rsbs r2, sl, r3, lsl #6 │ │ │ │ rsbs r2, r8, r4, lsl #6 │ │ │ │ rsbs r2, r6, r6, lsl #6 │ │ │ │ rsbs r2, r4, r5, lsl #6 │ │ │ │ rsbs r2, r2, r7, lsl #6 │ │ │ │ rsbs r2, r0, r0, lsl #6 │ │ │ │ - mcr 7, 5, pc, cr12, cr3, {7} @ │ │ │ │ + b ff44dd6c <__bss_end__@@Base+0xff3a71cc> │ │ │ │ ldmdavs sl, {r0, r1, r9, sl, lr} │ │ │ │ subseq r4, fp, r3, lsr #12 │ │ │ │ ldmdahi fp, {r0, r1, r4, sl, lr} │ │ │ │ movwpl pc, #1027 @ 0x403 @ │ │ │ │ tstle r9, r0, lsl #22 │ │ │ │ andsle r2, r7, sp, lsr #24 │ │ │ │ @ instruction: 0xf7f34620 │ │ │ │ - @ instruction: 0x4603ecf8 │ │ │ │ + @ instruction: 0x4603e91a │ │ │ │ andsle r2, r1, lr, asr #22 │ │ │ │ @ instruction: 0xf7f34620 │ │ │ │ - @ instruction: 0x4603ecf2 │ │ │ │ + @ instruction: 0x4603e914 │ │ │ │ andle r2, fp, r3, asr fp │ │ │ │ @ instruction: 0xf7f34620 │ │ │ │ - strmi lr, [r3], -ip, ror #25 │ │ │ │ + strmi lr, [r3], -lr, lsl #18 │ │ │ │ andle r2, r5, r7, asr fp │ │ │ │ @ instruction: 0xf7f34620 │ │ │ │ - strmi lr, [r3], -r6, ror #25 │ │ │ │ + strmi lr, [r3], -r8, lsl #18 │ │ │ │ @ instruction: 0xd1252b45 │ │ │ │ ldrbtmi r4, [fp], #-2864 @ 0xfffff4d0 │ │ │ │ - bmi c296ec <__bss_end__@@Base+0xb82ab4> │ │ │ │ + bmi c29e5c <__bss_end__@@Base+0xb832bc> │ │ │ │ tstcs r0, sl, ror r4 │ │ │ │ ldmdavs fp!, {r0, r4, r6, r7, sl, ip, lr}^ │ │ │ │ ldmdavs fp!, {r2, r3, r4, r6, r7, sp, lr}^ │ │ │ │ addsvs r2, sl, r1, lsl #4 │ │ │ │ tstle sl, r2, lsl #26 │ │ │ │ ldrbtmi r4, [fp], #-2859 @ 0xfffff4d5 │ │ │ │ @ instruction: 0xf7f34618 │ │ │ │ - strmi lr, [r2], -ip, lsr #28 │ │ │ │ + @ instruction: 0x4602ea50 │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ movwcs r6, #8218 @ 0x201a │ │ │ │ - blmi a47770 <__bss_end__@@Base+0x9a0b38> │ │ │ │ + blmi a47ee0 <__bss_end__@@Base+0x9a1340> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - mrc 7, 1, APSR_nzcv, cr2, cr3, {7} │ │ │ │ - blvc 104b178 <__bss_end__@@Base+0xfa4540> │ │ │ │ + b 15cddf0 <__bss_end__@@Base+0x1527250> │ │ │ │ + blvc 104b8e8 <__bss_end__@@Base+0xfa4d48> │ │ │ │ ldrbtmi r4, [fp], #-2853 @ 0xfffff4db │ │ │ │ - blvc 4accc │ │ │ │ + blvc 4b43c │ │ │ │ eor r2, r4, r1, lsl #6 │ │ │ │ tstle r0, lr, lsr #24 │ │ │ │ - blmi 898ad8 <__bss_end__@@Base+0x7f1ea0> │ │ │ │ + blmi 899248 <__bss_end__@@Base+0x7f26a8> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bmi 856838 <__bss_end__@@Base+0x7afc00> │ │ │ │ + bmi 856fa8 <__bss_end__@@Base+0x7b0408> │ │ │ │ andsvs r4, r1, sl, ror r4 │ │ │ │ - bmi 83c260 <__bss_end__@@Base+0x795628> │ │ │ │ + bmi 83c9d0 <__bss_end__@@Base+0x795e30> │ │ │ │ ldrbpl r4, [r1], #1146 @ 0x47a │ │ │ │ - blmi 807714 <__bss_end__@@Base+0x760adc> │ │ │ │ + blmi 807e84 <__bss_end__@@Base+0x7612e4> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bmi 796850 <__bss_end__@@Base+0x6efc18> │ │ │ │ + bmi 796fc0 <__bss_end__@@Base+0x6f0420> │ │ │ │ andsvs r4, r1, sl, ror r4 │ │ │ │ - bmi 77c278 <__bss_end__@@Base+0x6d5640> │ │ │ │ + bmi 77c9e8 <__bss_end__@@Base+0x6d5e48> │ │ │ │ ldrbpl r4, [r1], #1146 @ 0x47a │ │ │ │ svclt 0x0000e000 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4604fe99 │ │ │ │ svccc 0x00fff1b4 │ │ │ │ mcrge 4, 6, pc, cr4, cr15, {3} @ │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ svclt 0x0000bdb0 │ │ │ │ - andeq ip, r4, ip, lsl r3 │ │ │ │ - andeq ip, r4, sl, asr #5 │ │ │ │ - andeq ip, r4, r2, asr #5 │ │ │ │ - @ instruction: 0x0004c1ba │ │ │ │ - andeq ip, r4, ip, lsr #5 │ │ │ │ - andeq ip, r4, r4, lsr #5 │ │ │ │ - muleq r4, ip, r1 │ │ │ │ - muleq r4, r0, r1 │ │ │ │ - andeq ip, r4, sl, lsl #3 │ │ │ │ - andeq ip, r4, lr, lsr #2 │ │ │ │ - andeq ip, r4, r8, lsr #32 │ │ │ │ - andeq ip, r4, r2, lsl r0 │ │ │ │ - strdeq fp, [r4], -lr │ │ │ │ - strdeq fp, [r4], -ip │ │ │ │ - andeq fp, r4, r6, ror #31 │ │ │ │ - ldrdeq ip, [r4], -ip @ │ │ │ │ - ldrdeq ip, [r4], -r4 │ │ │ │ - andeq fp, r4, ip, asr #31 │ │ │ │ - andeq ip, r4, r4, asr #1 │ │ │ │ - strheq ip, [r4], -ip @ │ │ │ │ - @ instruction: 0x0004bfb4 │ │ │ │ + andeq fp, r4, r4, lsl fp │ │ │ │ + andeq fp, r4, r2, asr #21 │ │ │ │ + @ instruction: 0x0004baba │ │ │ │ + @ instruction: 0x0004b9b2 │ │ │ │ + andeq fp, r4, r4, lsr #21 │ │ │ │ + muleq r4, ip, sl │ │ │ │ + muleq r4, r4, r9 │ │ │ │ + andeq fp, r4, r8, lsl #19 │ │ │ │ + andeq fp, r4, r2, lsl #19 │ │ │ │ + andeq fp, r4, r6, lsr #18 │ │ │ │ + andeq fp, r4, r0, lsr #16 │ │ │ │ + andeq fp, r4, sl, lsl #16 │ │ │ │ + strdeq fp, [r4], -r6 │ │ │ │ + strdeq fp, [r4], -r4 │ │ │ │ + ldrdeq fp, [r4], -lr │ │ │ │ + ldrdeq fp, [r4], -r4 │ │ │ │ + andeq fp, r4, ip, asr #17 │ │ │ │ + andeq fp, r4, r4, asr #15 │ │ │ │ + @ instruction: 0x0004b8bc │ │ │ │ + @ instruction: 0x0004b8b4 │ │ │ │ + andeq fp, r4, ip, lsr #15 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ rscsvs pc, r8, r3, lsl #29 │ │ │ │ @ instruction: 0x461868fb │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ @@ -12384,63 +12887,63 @@ │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ @ instruction: 0xf6c30300 │ │ │ │ stmib r7, {r4, r5, r6, r7, r8, r9, ip, sp, lr}^ │ │ │ │ movwcs r2, #4868 @ 0x1304 │ │ │ │ ldmdavs r8!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ @ instruction: 0xffdcf7ff │ │ │ │ ldmvs fp!, {r3, r4, r5, r7, sp, lr} │ │ │ │ - blcs 11e3c0 <__bss_end__@@Base+0x77788> │ │ │ │ + blcs 11eb30 <__bss_end__@@Base+0x77f90> │ │ │ │ andge sp, r2, #7274496 @ 0x6f0000 │ │ │ │ eorcc pc, r3, r2, asr r8 @ │ │ │ │ @ instruction: 0x4710441a │ │ │ │ andeq r0, r0, pc, lsl #1 │ │ │ │ andeq r0, r0, r9, lsr r0 │ │ │ │ ldrdeq r0, [r0], -r7 │ │ │ │ andeq r0, r0, r5, lsl r0 │ │ │ │ andeq r0, r0, r5, lsr #32 │ │ │ │ ldrbtmi r4, [r9], #-2359 @ 0xfffff6c9 │ │ │ │ movwcs lr, #27095 @ 0x69d7 │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ subs r2, pc, r0, lsl #6 │ │ │ │ - blvc 1cae4c <__bss_end__@@Base+0x124214> │ │ │ │ - blvc 120b2b8 <__bss_end__@@Base+0x1164680> │ │ │ │ + blvc 1cb5bc <__bss_end__@@Base+0x124a1c> │ │ │ │ + blvc 120ba28 <__bss_end__@@Base+0x1164e88> │ │ │ │ ldrbtmi r4, [fp], #-2866 @ 0xfffff4ce │ │ │ │ - blvc 4ae08 │ │ │ │ + blvc 4b578 │ │ │ │ subs r2, r5, r0, lsl #6 │ │ │ │ - blcs 29bf0 │ │ │ │ - blmi c03898 <__bss_end__@@Base+0xb5cc60> │ │ │ │ + blcs 2a360 │ │ │ │ + blmi c04008 <__bss_end__@@Base+0xb5d468> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bcc fe44b02c <__bss_end__@@Base+0xfe3a43f4> │ │ │ │ - blpl ffa0b2f4 <__bss_end__@@Base+0xff9646bc> │ │ │ │ - blvs 14ae74 <__bss_end__@@Base+0xa423c> │ │ │ │ - blvc 1cb230 <__bss_end__@@Base+0x1245f8> │ │ │ │ - blvs 1cae7c <__bss_end__@@Base+0x124244> │ │ │ │ - blvc 20b0fc <__bss_end__@@Base+0x1644c4> │ │ │ │ - blvc 1cae44 <__bss_end__@@Base+0x12420c> │ │ │ │ - blvc 14ae88 <__bss_end__@@Base+0xa4250> │ │ │ │ - blvs 88aeac <__bss_end__@@Base+0x7e4274> │ │ │ │ - blvc 1cb0d0 <__bss_end__@@Base+0x124498> │ │ │ │ - blvc 14ae54 <__bss_end__@@Base+0xa421c> │ │ │ │ + bcc fe44b79c <__bss_end__@@Base+0xfe3a4bfc> │ │ │ │ + blpl ffa0ba64 <__bss_end__@@Base+0xff964ec4> │ │ │ │ + blvs 14b5e4 <__bss_end__@@Base+0xa4a44> │ │ │ │ + blvc 1cb9a0 <__bss_end__@@Base+0x124e00> │ │ │ │ + blvs 1cb5ec <__bss_end__@@Base+0x124a4c> │ │ │ │ + blvc 20b86c <__bss_end__@@Base+0x164ccc> │ │ │ │ + blvc 1cb5b4 <__bss_end__@@Base+0x124a14> │ │ │ │ + blvc 14b5f8 <__bss_end__@@Base+0xa4a58> │ │ │ │ + blvs 88b61c <__bss_end__@@Base+0x7e4a7c> │ │ │ │ + blvc 1cb840 <__bss_end__@@Base+0x124ca0> │ │ │ │ + blvc 14b5c4 <__bss_end__@@Base+0xa4a24> │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ umlalsvs pc, r8, r7, pc @ │ │ │ │ - blcs e9b30 <__bss_end__@@Base+0x42ef8> │ │ │ │ + blcs ea2a0 <__bss_end__@@Base+0x43700> │ │ │ │ ldmdavs r8!, {r1, r2, r3, r5, r8, ip, lr, pc}^ │ │ │ │ @ instruction: 0xff90f7ff │ │ │ │ strht r6, [r9], -r8 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ movwcs lr, #42 @ 0x2a │ │ │ │ - blmi 6e7c48 <__bss_end__@@Base+0x641010> │ │ │ │ + blmi 6e83b8 <__bss_end__@@Base+0x641818> │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ vldr d5, [r7] │ │ │ │ vdiv.f64 d6, d5, d4 │ │ │ │ vldr d7, [r7, #24] │ │ │ │ vadd.f64 d6, d6, d6 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #24] │ │ │ │ - vldr d7, [pc, #16] @ f88c │ │ │ │ + vldr d7, [pc, #16] @ fffc │ │ │ │ vmul.f64 d6, d7, d14 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmdavs r8!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ @ instruction: 0xff70f7ff │ │ │ │ ldmvs fp!, {r3, r4, r5, r7, sp, lr} │ │ │ │ tstle r9, r3, lsl #22 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @@ -12449,237 +12952,237 @@ │ │ │ │ strd r3, [r3], -pc @ │ │ │ │ str fp, [r6, r0, lsl #30] │ │ │ │ str fp, [r4, r0, lsl #30] │ │ │ │ @ instruction: 0x37204618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ - andeq fp, r4, r2, asr #29 │ │ │ │ - andeq fp, r4, sl, lsr #29 │ │ │ │ - muleq r4, r8, lr │ │ │ │ - andeq fp, r4, r4, asr #28 │ │ │ │ + @ instruction: 0x0004b6ba │ │ │ │ + andeq fp, r4, r2, lsr #13 │ │ │ │ + muleq r4, r0, r6 │ │ │ │ + andeq fp, r4, ip, lsr r6 │ │ │ │ addlt fp, r8, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #27079 @ 0x69c7 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ movwcs lr, #18887 @ 0x49c7 │ │ │ │ adcsvs r2, fp, r1, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603ff39 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ - blcs 19e508 <__bss_end__@@Base+0xf78d0> │ │ │ │ + blcs 19ec78 <__bss_end__@@Base+0xf80d8> │ │ │ │ andge sp, r2, #7798784 @ 0x770000 │ │ │ │ eorcc pc, r3, r2, asr r8 @ │ │ │ │ @ instruction: 0x4710441a │ │ │ │ muleq r0, fp, r0 │ │ │ │ andeq r0, r0, r1, asr #32 │ │ │ │ andeq r0, r0, r7, ror #1 │ │ │ │ andeq r0, r0, r7, ror #1 │ │ │ │ andeq r0, r0, r7, ror #1 │ │ │ │ andeq r0, r0, sp, lsl r0 │ │ │ │ andeq r0, r0, sp, lsr #32 │ │ │ │ ldrbtmi r4, [r9], #-2361 @ 0xfffff6c7 │ │ │ │ movwcs lr, #27095 @ 0x69d7 │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ rsb r2, r3, r0, lsl #6 │ │ │ │ - blvc 1caf9c <__bss_end__@@Base+0x124364> │ │ │ │ - blvc 120b408 <__bss_end__@@Base+0x11647d0> │ │ │ │ + blvc 1cb70c <__bss_end__@@Base+0x124b6c> │ │ │ │ + blvc 120bb78 <__bss_end__@@Base+0x1164fd8> │ │ │ │ ldrbtmi r4, [fp], #-2868 @ 0xfffff4cc │ │ │ │ - blvc 4af58 │ │ │ │ + blvc 4b6c8 │ │ │ │ subs r2, r9, r0, lsl #6 │ │ │ │ - blcs 29c40 │ │ │ │ - blmi c839f0 <__bss_end__@@Base+0xbdcdb8> │ │ │ │ + blcs 2a3b0 │ │ │ │ + blmi c84160 <__bss_end__@@Base+0xbdd5c0> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bcc fe44b17c <__bss_end__@@Base+0xfe3a4544> │ │ │ │ - blpl ffa0b444 <__bss_end__@@Base+0xff96480c> │ │ │ │ - blvs 14afc4 <__bss_end__@@Base+0xa438c> │ │ │ │ - blvc 1cb380 <__bss_end__@@Base+0x124748> │ │ │ │ - blvs 1cafcc <__bss_end__@@Base+0x124394> │ │ │ │ - blvc 20b24c <__bss_end__@@Base+0x164614> │ │ │ │ - blvc 1caf94 <__bss_end__@@Base+0x12435c> │ │ │ │ - blvc 14afd8 <__bss_end__@@Base+0xa43a0> │ │ │ │ - blvs 90affc <__bss_end__@@Base+0x8643c4> │ │ │ │ - blvc 1cb220 <__bss_end__@@Base+0x1245e8> │ │ │ │ - blvc 14afa4 <__bss_end__@@Base+0xa436c> │ │ │ │ + bcc fe44b8ec <__bss_end__@@Base+0xfe3a4d4c> │ │ │ │ + blpl ffa0bbb4 <__bss_end__@@Base+0xff965014> │ │ │ │ + blvs 14b734 <__bss_end__@@Base+0xa4b94> │ │ │ │ + blvc 1cbaf0 <__bss_end__@@Base+0x124f50> │ │ │ │ + blvs 1cb73c <__bss_end__@@Base+0x124b9c> │ │ │ │ + blvc 20b9bc <__bss_end__@@Base+0x164e1c> │ │ │ │ + blvc 1cb704 <__bss_end__@@Base+0x124b64> │ │ │ │ + blvc 14b748 <__bss_end__@@Base+0xa4ba8> │ │ │ │ + blvs 90b76c <__bss_end__@@Base+0x864bcc> │ │ │ │ + blvc 1cb990 <__bss_end__@@Base+0x124df0> │ │ │ │ + blvc 14b714 <__bss_end__@@Base+0xa4b74> │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -pc, ror #29 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ teqle r1, r3, lsl #22 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r7, ror #29 │ │ │ │ strd r6, [fp], -fp @ │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ movwcs lr, #44 @ 0x2c │ │ │ │ - blmi 727c9c <__bss_end__@@Base+0x681064> │ │ │ │ + blmi 72840c <__bss_end__@@Base+0x68186c> │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ vldr d5, [r7] │ │ │ │ vdiv.f64 d6, d5, d4 │ │ │ │ vldr d7, [r7, #24] │ │ │ │ vadd.f64 d6, d6, d6 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #24] │ │ │ │ - vldr d7, [pc, #16] @ f9e0 │ │ │ │ + vldr d7, [pc, #16] @ 10150 │ │ │ │ vmul.f64 d6, d7, d15 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmdavs r8!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ mcr2 7, 6, pc, cr6, cr15, {7} @ │ │ │ │ rscsvs r4, fp, r3, lsl #12 │ │ │ │ - blcs e9dd4 <__bss_end__@@Base+0x4319c> │ │ │ │ + blcs ea544 <__bss_end__@@Base+0x439a4> │ │ │ │ ldmdavs r8!, {r1, r3, r8, ip, lr, pc}^ │ │ │ │ mrc2 7, 5, pc, cr14, cr15, {7} │ │ │ │ rscsvs r4, fp, r3, lsl #12 │ │ │ │ @ instruction: 0xf04fe004 │ │ │ │ strd r3, [r3], -pc @ │ │ │ │ ldrb fp, [lr, -r0, lsl #30]! │ │ │ │ ldrb fp, [ip, -r0, lsl #30]! │ │ │ │ @ instruction: 0x37204618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ - andeq fp, r4, r2, ror sp │ │ │ │ - andeq fp, r4, sl, asr sp │ │ │ │ - andeq fp, r4, r8, asr #26 │ │ │ │ - strdeq fp, [r4], -r0 │ │ │ │ + andeq fp, r4, sl, ror #10 │ │ │ │ + andeq fp, r4, r2, asr r5 │ │ │ │ + andeq fp, r4, r0, asr #10 │ │ │ │ + andeq fp, r4, r8, ror #9 │ │ │ │ adclt fp, r8, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ movwcs r6, #187 @ 0xbb │ │ │ │ @ instruction: 0xf107613b │ │ │ │ ldrmi r0, [r8], -r8, lsl #6 │ │ │ │ mcr2 7, 5, pc, cr3, cr15, {7} @ │ │ │ │ - blcs 21250 │ │ │ │ + blcs 219c0 │ │ │ │ movwcs sp, #1 │ │ │ │ - blmi 4c7aa0 <__bss_end__@@Base+0x420e68> │ │ │ │ + blmi 4c8210 <__bss_end__@@Base+0x421670> │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ - vldr d7, [pc] @ fa54 │ │ │ │ + vldr d7, [pc] @ 101c4 │ │ │ │ vmul.f64 d6, d7, d12 │ │ │ │ - vldr d6, [pc, #24] @ fa74 │ │ │ │ + vldr d6, [pc, #24] @ 101e4 │ │ │ │ vdiv.f64 d5, d6, d12 │ │ │ │ ldmdavs fp!, {r0, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 4b074 │ │ │ │ + blvc 4b7e4 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ svclt 0x000c2b00 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0x4618b2db │ │ │ │ ldrtmi r3, [sp], r0, lsr #15 │ │ │ │ svclt 0x0000bd80 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ - andeq fp, r4, r4, asr ip │ │ │ │ + andeq fp, r4, ip, asr #8 │ │ │ │ adclt fp, r8, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ movwcs r6, #187 @ 0xbb │ │ │ │ @ instruction: 0xf107613b │ │ │ │ ldrmi r0, [r8], -r8, lsl #6 │ │ │ │ @ instruction: 0xff0cf7ff │ │ │ │ - blcs 212c4 │ │ │ │ + blcs 21a34 │ │ │ │ movwcs sp, #1 │ │ │ │ - blmi 487b14 <__bss_end__@@Base+0x3e0edc> │ │ │ │ + blmi 488284 <__bss_end__@@Base+0x3e16e4> │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ - vldr d7, [pc] @ fac8 │ │ │ │ + vldr d7, [pc] @ 10238 │ │ │ │ vmul.f64 d6, d7, d11 │ │ │ │ - vldr d6, [pc, #24] @ fae8 │ │ │ │ + vldr d6, [pc, #24] @ 10258 │ │ │ │ vdiv.f64 d5, d6, d11 │ │ │ │ ldmdavs fp!, {r0, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 4b0e8 │ │ │ │ + blvc 4b858 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ svclt 0x000c2b00 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0x4618b2db │ │ │ │ ldrtmi r3, [sp], r0, lsr #15 │ │ │ │ svclt 0x0000bd80 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ - andeq fp, r4, r0, ror #23 │ │ │ │ + ldrdeq fp, [r4], -r8 │ │ │ │ adclt fp, r8, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ movwcs r6, #187 @ 0xbb │ │ │ │ @ instruction: 0xf107613b │ │ │ │ ldrmi r0, [r8], -r8, lsl #6 │ │ │ │ mrc2 7, 1, pc, cr1, cr15, {7} │ │ │ │ - blcs 21334 │ │ │ │ + blcs 21aa4 │ │ │ │ movwcs sp, #1 │ │ │ │ - blmi 807bec <__bss_end__@@Base+0x760fb4> │ │ │ │ + blmi 80835c <__bss_end__@@Base+0x7617bc> │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ - vldr d7, [pc] @ fb38 │ │ │ │ + vldr d7, [pc] @ 102a8 │ │ │ │ vmov.32 d7[1], r6 │ │ │ │ - vldr d6, [pc, #24] @ fb58 │ │ │ │ + vldr d6, [pc, #24] @ 102c8 │ │ │ │ vdup.32 d6, r5 │ │ │ │ ldmdavs fp!, {r0, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 4b158 │ │ │ │ + blvc 4b8c8 │ │ │ │ movweq pc, #33031 @ 0x8107 @ │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ @ instruction: 0x4603febb │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ ands r2, r6, r0, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2835 @ 0xfffff4ed │ │ │ │ - blvc 4b1b4 │ │ │ │ - blvs 34b1e8 <__bss_end__@@Base+0x2a45b0> │ │ │ │ - blvs 1cb40c <__bss_end__@@Base+0x1247d4> │ │ │ │ - blpl 34b1f0 <__bss_end__@@Base+0x2a45b8> │ │ │ │ - blvc 18b590 <__bss_end__@@Base+0xe4958> │ │ │ │ + blvc 4b924 │ │ │ │ + blvs 34b958 <__bss_end__@@Base+0x2a4db8> │ │ │ │ + blvs 1cbb7c <__bss_end__@@Base+0x124fdc> │ │ │ │ + blpl 34b960 <__bss_end__@@Base+0x2a4dc0> │ │ │ │ + blvc 18bd00 <__bss_end__@@Base+0xe5160> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ ldmdavs r9!, {r1, r8, r9, fp, ip, sp, lr} │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #18881 @ 0x49c1 │ │ │ │ @ instruction: 0x461868bb │ │ │ │ ldrtmi r3, [sp], r0, lsr #15 │ │ │ │ svclt 0x0000bd80 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ - andeq fp, r4, r0, ror fp │ │ │ │ - andeq fp, r4, lr, lsr fp │ │ │ │ + andeq fp, r4, r8, ror #6 │ │ │ │ + andeq fp, r4, r6, lsr r3 │ │ │ │ addlt fp, lr, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, sp, lr} │ │ │ │ - @ instruction: 0xf878f7fb │ │ │ │ + ldc2 7, cr15, [r4], #1000 @ 0x3e8 │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d7, #18 @ 0x40900000 4.5 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ tstcs r3, r7, asr #22 │ │ │ │ - @ instruction: 0xf7fb6838 │ │ │ │ - ldmdavs fp!, {r0, r1, r4, r6, r7, r8, fp, ip, sp, lr, pc}^ │ │ │ │ - blvc 4b22c │ │ │ │ - bleq 120b6a4 <__bss_end__@@Base+0x1164a6c> │ │ │ │ + @ instruction: 0xf7fa6838 │ │ │ │ + ldmdavs fp!, {r2, r4, r5, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + blvc 4b99c │ │ │ │ + bleq 120be14 <__bss_end__@@Base+0x1165274> │ │ │ │ ldmdavs r8!, {r1, r8, sp} │ │ │ │ - @ instruction: 0xf9caf7fb │ │ │ │ - bleq 60b26c <__bss_end__@@Base+0x564634> │ │ │ │ + mcr2 7, 1, pc, cr11, cr10, {7} @ │ │ │ │ + bleq 60b9dc <__bss_end__@@Base+0x564e3c> │ │ │ │ ldmdavs r8!, {r1, r8, sp} │ │ │ │ - @ instruction: 0xf9c4f7fb │ │ │ │ + mcr2 7, 1, pc, cr5, cr10, {7} @ │ │ │ │ msreq CPSR_, #-1073741823 @ 0xc0000001 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx fe44dc02 <__bss_end__@@Base+0xfe3a6fca> │ │ │ │ + blx fe44e372 <__bss_end__@@Base+0xfe3a77d2> │ │ │ │ andeq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ msreq CPSR_, #-1073741823 @ 0xc0000001 │ │ │ │ @ instruction: 0x46186839 │ │ │ │ - blx acdc02 <__bss_end__@@Base+0xa26fca> │ │ │ │ - blvc cb274 <__bss_end__@@Base+0x2463c> │ │ │ │ - blvc 120b6e0 <__bss_end__@@Base+0x1164aa8> │ │ │ │ + @ instruction: 0xf80af7fb │ │ │ │ + blvc cb9e4 <__bss_end__@@Base+0x24e44> │ │ │ │ + blvc 120be50 <__bss_end__@@Base+0x11652b0> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ vldr d7, [r7, #24] │ │ │ │ vmov.f64 d7, #20 @ 0x40a00000 5.0 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 3cb23c <__bss_end__@@Base+0x324604> │ │ │ │ - blvc 1cb290 <__bss_end__@@Base+0x124658> │ │ │ │ - blvc 120b6fc <__bss_end__@@Base+0x1164ac4> │ │ │ │ + blvc 3cb9ac <__bss_end__@@Base+0x324e0c> │ │ │ │ + blvc 1cba00 <__bss_end__@@Base+0x124e60> │ │ │ │ + blvc 120be6c <__bss_end__@@Base+0x11652cc> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ svclt 0x00007b16 │ │ │ │ @ instruction: 0x46bd3738 │ │ │ │ svclt 0x0000bd80 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ svccc 0x00f921fb │ │ │ │ @@ -12696,329 +13199,329 @@ │ │ │ │ subsvs r2, sl, r0, lsl #4 │ │ │ │ ldrbtmi r4, [fp], #-2824 @ 0xfffff4f8 │ │ │ │ @ instruction: 0x601a68ba │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ svclt 0x0000bf00 │ │ │ │ ssatmi r3, #30, r4, lsl #14 │ │ │ │ - blvc 14de10 <__bss_end__@@Base+0xa71d8> │ │ │ │ + blvc 14e580 <__bss_end__@@Base+0xa79e0> │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq fp, r4, sl, lsr fp │ │ │ │ - andeq fp, r4, sl, lsr #22 │ │ │ │ + andeq fp, r4, r2, lsr r3 │ │ │ │ + andeq fp, r4, r2, lsr #6 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ and sl, lr, r0, lsl #30 │ │ │ │ ldrbtmi r4, [fp], #-2838 @ 0xfffff4ea │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ - blmi 567da8 <__bss_end__@@Base+0x4c1170> │ │ │ │ + blmi 568518 <__bss_end__@@Base+0x4c1978> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf0034618 │ │ │ │ - blmi 50f9d4 <__bss_end__@@Base+0x468d9c> │ │ │ │ + blmi 50f414 <__bss_end__@@Base+0x468874> │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - blmi 4a7d38 <__bss_end__@@Base+0x401100> │ │ │ │ + blmi 4a84a8 <__bss_end__@@Base+0x401908> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ - blmi 447d14 <__bss_end__@@Base+0x3a10dc> │ │ │ │ + blmi 448484 <__bss_end__@@Base+0x3a18e4> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ rsbsvs r6, fp, fp, lsl r8 │ │ │ │ ldrbtmi r4, [fp], #-2830 @ 0xfffff4f2 │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - @ instruction: 0xff2ef003 │ │ │ │ + blx ff8cc46e <__bss_end__@@Base+0xff8258ce> │ │ │ │ ldrbtmi r4, [fp], #-2828 @ 0xfffff4f4 │ │ │ │ andsvs r6, sl, sl, ror r8 │ │ │ │ ldrbtmi r4, [fp], #-2827 @ 0xfffff4f5 │ │ │ │ - blcs 29d6c │ │ │ │ + blcs 2a4dc │ │ │ │ svclt 0x0000d1eb │ │ │ │ strcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - strdeq fp, [r4], -lr │ │ │ │ - strdeq fp, [r4], -r4 │ │ │ │ - andeq fp, r4, r8, ror #21 │ │ │ │ - andeq fp, r4, r0, ror #21 │ │ │ │ - ldrdeq fp, [r4], -r0 │ │ │ │ - andeq fp, r4, r6, asr #21 │ │ │ │ - @ instruction: 0x0004baba │ │ │ │ - @ instruction: 0x0004bab2 │ │ │ │ + strdeq fp, [r4], -r6 │ │ │ │ + andeq fp, r4, ip, ror #5 │ │ │ │ + andeq fp, r4, r0, ror #5 │ │ │ │ + ldrdeq fp, [r4], -r8 │ │ │ │ + andeq fp, r4, r8, asr #5 │ │ │ │ + @ instruction: 0x0004b2be │ │ │ │ + @ instruction: 0x0004b2b2 │ │ │ │ + andeq fp, r4, sl, lsr #5 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldrbtmi r4, [fp], #-2845 @ 0xfffff4e3 │ │ │ │ - blcs 29dac │ │ │ │ - blmi 74417c <__bss_end__@@Base+0x69d544> │ │ │ │ + blcs 2a51c │ │ │ │ + blmi 7448ec <__bss_end__@@Base+0x69dd4c> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - @ instruction: 0xf9a8f004 │ │ │ │ + cdp2 0, 5, cr15, cr12, cr3, {0} │ │ │ │ ldrbtmi r4, [fp], #-2842 @ 0xfffff4e6 │ │ │ │ @ instruction: 0x21ac221c │ │ │ │ ldrbtmi r4, [r8], #-2073 @ 0xfffff7e7 │ │ │ │ - cdp2 0, 4, cr15, cr8, cr3, {0} │ │ │ │ + blx fff4c4d8 <__bss_end__@@Base+0xffea5938> │ │ │ │ and r6, sl, r8, ror r1 │ │ │ │ ldrbtmi r4, [fp], #-2839 @ 0xfffff4e9 │ │ │ │ cmnvs fp, fp, lsl r8 │ │ │ │ ldrbtmi r4, [fp], #-2838 @ 0xfffff4ea │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ ldrbtmi r4, [fp], #-2837 @ 0xfffff4eb │ │ │ │ andscs r6, ip, #26 │ │ │ │ ldmdbvs r8!, {r8, sp}^ │ │ │ │ - stmib r4, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stc 7, cr15, [r6, #968]! @ 0x3c8 │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ @ instruction: 0x609a68fa │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, r7, sp, lr}^ │ │ │ │ @ instruction: 0x611a68ba │ │ │ │ andcs r6, r0, #2015232 @ 0x1ec000 │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, r8, sp, lr}^ │ │ │ │ orrsvs r2, sl, r0, lsl #4 │ │ │ │ @ instruction: 0x4618697b │ │ │ │ ssatmi r3, #30, r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq fp, r4, r6, ror sl │ │ │ │ + andeq fp, r4, lr, ror #4 │ │ │ │ @ instruction: 0xffffff61 │ │ │ │ @ instruction: 0xffffff03 │ │ │ │ - andeq lr, r3, sl, lsr #31 │ │ │ │ - andeq fp, r4, lr, asr #20 │ │ │ │ - andeq fp, r4, r6, asr #20 │ │ │ │ - andeq fp, r4, lr, lsr sl │ │ │ │ + andeq lr, r3, sl, asr r9 │ │ │ │ + andeq fp, r4, r6, asr #4 │ │ │ │ + andeq fp, r4, lr, lsr r2 │ │ │ │ + andeq fp, r4, r6, lsr r2 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blcs 29fc4 │ │ │ │ + blcs 2a734 │ │ │ │ ldmdavs r8!, {r2, r3, ip, lr, pc}^ │ │ │ │ @ instruction: 0xff3af7ff │ │ │ │ ldrbtmi r4, [fp], #-2822 @ 0xfffff4fa │ │ │ │ ldmdavs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ - blmi 167e54 <__bss_end__@@Base+0xc121c> │ │ │ │ + blmi 1685c4 <__bss_end__@@Base+0xc1a24> │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ and r6, r0, sl, lsl r0 │ │ │ │ strcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq fp, r4, lr, asr #19 │ │ │ │ - andeq fp, r4, r4, asr #19 │ │ │ │ + andeq fp, r4, r6, asr #3 │ │ │ │ + @ instruction: 0x0004b1bc │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ orrsvs r6, sl, sl, lsr r8 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r4, sp, lr, pc}^ │ │ │ │ rscsvs r6, fp, fp, asr r9 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf0034618 │ │ │ │ - ldmvs fp!, {r0, r1, r4, r7, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmvs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ subsvs r2, sl, r0, lsl #4 │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ cmpvs sl, fp, ror r8 │ │ │ │ ldrbtmi r4, [fp], #-2824 @ 0xfffff4f8 │ │ │ │ ldmvs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ - blmi 1e7ea8 <__bss_end__@@Base+0x141270> │ │ │ │ + blmi 1e8618 <__bss_end__@@Base+0x141a78> │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ - blcs 2a3b8 │ │ │ │ + blcs 2ab28 │ │ │ │ movwcs sp, #483 @ 0x1e3 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq fp, r4, r6, ror r9 │ │ │ │ - andeq fp, r4, ip, ror #18 │ │ │ │ + andeq fp, r4, lr, ror #2 │ │ │ │ + andeq fp, r4, r4, ror #2 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blmi 4a7f68 <__bss_end__@@Base+0x401330> │ │ │ │ + blmi 4a86d8 <__bss_end__@@Base+0x401b38> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ tstle r8, r0, lsl #22 │ │ │ │ andcs r2, r8, #0, 6 │ │ │ │ stmdami pc, {r0, r1, r2, r5, r6, r7, r8, sp} @ │ │ │ │ @ instruction: 0xf0034478 │ │ │ │ - rscsvs pc, r8, r9, lsr #27 │ │ │ │ - blmi 387ec0 <__bss_end__@@Base+0x2e1288> │ │ │ │ + rscsvs pc, r8, sp, asr sl @ │ │ │ │ + blmi 388630 <__bss_end__@@Base+0x2e1a90> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ - blmi 2e9f14 <__bss_end__@@Base+0x2432dc> │ │ │ │ + blmi 2ea684 <__bss_end__@@Base+0x243ae4> │ │ │ │ andsvs r4, sl, fp, ror r4 │ │ │ │ ldmdbvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0x601a68fb │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ ldrshvs r6, [sl, #-138] @ 0xffffff76 │ │ │ │ ldrcc fp, [r0, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq fp, r4, r8, lsr #18 │ │ │ │ - andeq lr, r3, ip, ror #28 │ │ │ │ - andeq fp, r4, ip, lsl #18 │ │ │ │ - andeq fp, r4, r0, lsl #18 │ │ │ │ + andeq fp, r4, r0, lsr #2 │ │ │ │ + andeq lr, r3, ip, lsl r8 │ │ │ │ + andeq fp, r4, r4, lsl #2 │ │ │ │ + strdeq fp, [r4], -r8 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x46181ad3 │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 14e084 <__bss_end__@@Base+0xa744c> │ │ │ │ + blvc 14e7f4 <__bss_end__@@Base+0xa7c54> │ │ │ │ strlt r4, [r0, #1904] @ 0x770 │ │ │ │ svcge 0x0000b084 │ │ │ │ eorsvs r6, r9, r8, ror r0 │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldrmi r6, [r3], #-2107 @ 0xfffff7c5 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r7, fp, sp, lr}^ │ │ │ │ ldrmi r6, [r3], #-2331 @ 0xfffff6e5 │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r7, sp, lr}^ │ │ │ │ addsmi r6, sl, #12255232 @ 0xbb0000 │ │ │ │ - blmi 307358 <__bss_end__@@Base+0x260720> │ │ │ │ + blmi 307ac8 <__bss_end__@@Base+0x260f28> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603ff5f │ │ │ │ ldmdavs fp!, {r0, r3, sp, lr, pc}^ │ │ │ │ ldrshvs r6, [sl], #138 @ 0x8a │ │ │ │ ldmvs fp!, {r1, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0x461a1ad3 │ │ │ │ tstvs sl, fp, ror r8 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - ldrdeq lr, [r3], -r4 │ │ │ │ + andeq lr, r3, r4, lsl #15 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - blcs ea3e8 <__bss_end__@@Base+0x437b0> │ │ │ │ - blmi 485f9c <__bss_end__@@Base+0x3df364> │ │ │ │ + blcs eab58 <__bss_end__@@Base+0x43fb8> │ │ │ │ + blmi 48670c <__bss_end__@@Base+0x3dfb6c> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603ff3d │ │ │ │ ldmdavs fp!, {r1, r2, r4, sp, lr, pc}^ │ │ │ │ svcne 0x001a691b │ │ │ │ tstvs sl, fp, ror r8 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ rscsvs r6, fp, fp, lsl r8 │ │ │ │ @ instruction: 0x461868fb │ │ │ │ - ldm r2!, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldcl 7, cr15, [r4], {242} @ 0xf2 │ │ │ │ ldrmi r4, [sl], -r3, lsl #12 │ │ │ │ andsvs r6, sl, fp, lsr r8 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r8, sl, fp, ip}^ │ │ │ │ movwcs r6, #4314 @ 0x10da │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - ldrdeq lr, [r3], -r0 │ │ │ │ + andeq lr, r3, r0, lsl #15 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - blcs ea444 <__bss_end__@@Base+0x4380c> │ │ │ │ - blmi 485ff8 <__bss_end__@@Base+0x3df3c0> │ │ │ │ + blcs eabb4 <__bss_end__@@Base+0x44014> │ │ │ │ + blmi 486768 <__bss_end__@@Base+0x3dfbc8> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -pc, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r2, r4, sp, lr, pc}^ │ │ │ │ svcne 0x001a691b │ │ │ │ tstvs sl, fp, ror r8 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ - @ instruction: 0xf7f34618 │ │ │ │ - @ instruction: 0x4603ea5a │ │ │ │ + @ instruction: 0xf7f24618 │ │ │ │ + @ instruction: 0x4603ee76 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r6, r7, fp, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ ldcne 8, cr6, [sl, #-876] @ 0xfffffc94 │ │ │ │ sbcsvs r6, sl, fp, ror r8 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq lr, r3, r0, lsr #27 │ │ │ │ + andeq lr, r3, r0, asr r7 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ addsmi r6, sl, #7995392 @ 0x7a0000 │ │ │ │ - blmi 446458 <__bss_end__@@Base+0x39f820> │ │ │ │ + blmi 446bc8 <__bss_end__@@Base+0x3a0028> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ff68f8 │ │ │ │ @ instruction: 0x4603fedf │ │ │ │ ldmvs fp!, {r0, r1, r4, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r8, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r1, r4, r6, r7, r9, fp, ip}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, r8, sp, lr}^ │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r6, r7, fp, sp, lr}^ │ │ │ │ ldmvs r8!, {r0, r3, r4, r9, sl, lr} │ │ │ │ - stmib r8!, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + mcr 7, 0, pc, cr4, cr2, {7} @ │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldrmi r6, [sl], #-2171 @ 0xfffff785 │ │ │ │ ldrshvs r6, [sl], #139 @ 0x8b │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq lr, r3, ip, ror #26 │ │ │ │ + andeq lr, r3, ip, lsl r7 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r8, fp, sp, lr}^ │ │ │ │ stmdble r7, {r1, r3, r4, r7, r9, lr} │ │ │ │ ldrbtmi r4, [fp], #-2849 @ 0xfffff4df │ │ │ │ ldmvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mrc2 7, 5, pc, cr0, cr15, {7} │ │ │ │ eors r4, r6, r3, lsl #12 │ │ │ │ ldmdbvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ - bne ff4aa29c <__bss_end__@@Base+0xff403664> │ │ │ │ + bne ff4aaa0c <__bss_end__@@Base+0xff403e6c> │ │ │ │ @ instruction: 0x611a68fb │ │ │ │ - blcs 2a1a4 │ │ │ │ + blcs 2a914 │ │ │ │ andcs sp, r1, #1 │ │ │ │ andcs lr, r0, #0 │ │ │ │ ldrmi r6, [r3], #-2171 @ 0xfffff785 │ │ │ │ movwcs r4, #1562 @ 0x61a │ │ │ │ asrvc pc, pc, #8 @ │ │ │ │ ldrbtmi r4, [r8], #-2069 @ 0xfffff7eb │ │ │ │ - stc2 0, cr15, [ip], {3} │ │ │ │ + @ instruction: 0xf940f003 │ │ │ │ ldmvs fp!, {r1, r9, sl, lr} │ │ │ │ ldmvs fp!, {r1, r3, r4, sp, lr} │ │ │ │ @ instruction: 0x4619681b │ │ │ │ @ instruction: 0xf7ff68f8 │ │ │ │ ldmvs fp!, {r0, r3, r6, r7, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ ldmvs fp!, {r0, r3, r4, r6, r7, fp, sp, lr} │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, fp, sp, lr}^ │ │ │ │ - @ instruction: 0xf7f34618 │ │ │ │ - ldmdavs fp!, {r5, r7, r8, fp, sp, lr, pc} │ │ │ │ + @ instruction: 0xf7f24618 │ │ │ │ + ldmdavs fp!, {r2, r3, r4, r5, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ andle r2, r5, r0, lsl #22 │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ ldrmi r6, [r3], #-2171 @ 0xfffff785 │ │ │ │ andsvc r2, sl, r0, lsl #4 │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldrmi r6, [sl], #-2171 @ 0xfffff785 │ │ │ │ ldrshvs r6, [sl], #139 @ 0x8b │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq lr, r3, sl, lsr sp │ │ │ │ - andeq lr, r3, r2, lsr ip │ │ │ │ + andeq lr, r3, sl, ror #13 │ │ │ │ + andeq lr, r3, r2, ror #11 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ addsmi r6, sl, #7995392 @ 0x7a0000 │ │ │ │ - blmi 44655c <__bss_end__@@Base+0x39f924> │ │ │ │ + blmi 446ccc <__bss_end__@@Base+0x3a012c> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ff68f8 │ │ │ │ @ instruction: 0x4603fe5d │ │ │ │ ldmvs fp!, {r0, r1, r4, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r8, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r1, r4, r6, r7, r9, fp, ip}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, r8, sp, lr}^ │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r6, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0x461868b9 │ │ │ │ - stmdb r6!, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stc 7, cr15, [r2, #968] @ 0x3c8 │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldrmi r6, [sl], #-2171 @ 0xfffff785 │ │ │ │ ldrshvs r6, [sl], #139 @ 0x8b │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq lr, r3, ip, asr #25 │ │ │ │ + andeq lr, r3, ip, ror r6 │ │ │ │ addlt fp, r8, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ tstcs r0, fp, lsr r0 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ movwcs pc, #11171 @ 0x2ba3 @ │ │ │ │ andle r2, r0, r0, lsl #22 │ │ │ │ @@ -13042,264 +13545,264 @@ │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ teqle r0, r1, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ eorle r2, r9, r2, lsl #22 │ │ │ │ stmdale sl!, {r1, r8, r9, fp, sp} │ │ │ │ eorle r2, r7, r0, lsl #22 │ │ │ │ @ instruction: 0xd1262b01 │ │ │ │ - blcs 2a3f0 │ │ │ │ + blcs 2ab60 │ │ │ │ ldmvs fp!, {r2, r8, ip, lr, pc} │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ sub r2, r6, r1, lsl #6 │ │ │ │ movwcs r6, #2362 @ 0x93a │ │ │ │ cmnpne fp, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [r8], #-2085 @ 0xfffff7db │ │ │ │ - blx ff9cc22e <__bss_end__@@Base+0xff9255f6> │ │ │ │ + @ instruction: 0xf89af003 │ │ │ │ ldmvs fp!, {r1, r9, sl, lr} │ │ │ │ ldmvs fp!, {r1, r3, r4, sp, lr} │ │ │ │ @ instruction: 0x4619681b │ │ │ │ @ instruction: 0xf7ff68f8 │ │ │ │ ldmvs fp!, {r0, r1, r5, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ ldrmi r2, [r8], -r0, lsl #2 │ │ │ │ - svc 0x0024f7f2 │ │ │ │ + bl 11ce978 <__bss_end__@@Base+0x1127dd8> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ @ instruction: 0xe00261bb │ │ │ │ eor r2, r8, r1, lsl #6 │ │ │ │ ldmvs fp!, {r8, r9, sl, fp, ip, sp, pc} │ │ │ │ @ instruction: 0x61bb681b │ │ │ │ cmnvs fp, r1, lsl #6 │ │ │ │ mvnsvs r2, r0, lsl #6 │ │ │ │ - bvs fef0828c <__bss_end__@@Base+0xfee61654> │ │ │ │ + bvs fef089fc <__bss_end__@@Base+0xfee61e5c> │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, r8, fp, sp, lr}^ │ │ │ │ @ instruction: 0x61784798 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r7, r8, fp, sp, lr} │ │ │ │ @ instruction: 0x61bb4413 │ │ │ │ movwcc r6, #6651 @ 0x19fb │ │ │ │ ldmibvs sl!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ addsmi r6, sl, #8060928 @ 0x7b0000 │ │ │ │ ldmdbvs fp!, {r1, r9, ip, lr, pc}^ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ tstle r7, r2, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ @ instruction: 0xf0034618 │ │ │ │ - ldmvs fp!, {r0, r1, r3, r4, r6, sl, fp, ip, sp, lr, pc} │ │ │ │ + ldmvs fp!, {r0, r1, r2, r3, r8, fp, ip, sp, lr, pc} │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ @ instruction: 0x4618697b │ │ │ │ ldrtmi r3, [sp], r0, lsr #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq lr, r3, lr, lsl #25 │ │ │ │ - andeq lr, r3, lr, lsr #25 │ │ │ │ - andeq lr, r3, r6, ror #21 │ │ │ │ + andeq lr, r3, lr, lsr r6 │ │ │ │ + andeq lr, r3, lr, asr r6 │ │ │ │ + muleq r3, r6, r4 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - blcs aa430 <__bss_end__@@Base+0x37f8> │ │ │ │ - blcs c4310 <__bss_end__@@Base+0x1d6d8> │ │ │ │ - blcs 46314 │ │ │ │ - blcs 842d8 <__bss_start@@Base+0x29238> │ │ │ │ + blcs aaba0 <__bss_end__@@Base+0x4000> │ │ │ │ + blcs c4a80 <__bss_end__@@Base+0x1dee0> │ │ │ │ + blcs 46a84 │ │ │ │ + blcs 84a48 <__bss_start@@Base+0x29a40> │ │ │ │ and sp, sp, r6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ mrc2 7, 3, pc, cr6, cr15, {7} │ │ │ │ and r4, r9, r3, lsl #12 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ mcr2 7, 2, pc, cr2, cr15, {7} @ │ │ │ │ and r4, r3, r3, lsl #12 │ │ │ │ and r2, r1, r1, lsl #6 │ │ │ │ - mcr 7, 1, pc, cr10, cr2, {7} @ │ │ │ │ + b 12cea2c <__bss_end__@@Base+0x1227e8c> │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs r9!, {r0, r3, r4, r5, sp, lr} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603ffd3 │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - blcs 2a494 │ │ │ │ + blcs 2ac04 │ │ │ │ ldmdavs fp!, {r1, r3, r8, ip, lr, pc} │ │ │ │ rscsvs r7, fp, fp, lsl r8 │ │ │ │ movweq pc, #49415 @ 0xc107 @ │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xffbcf7ff │ │ │ │ ands r4, fp, r3, lsl #12 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ tstle r6, r1, lsl #22 │ │ │ │ movweq pc, #49415 @ 0xc107 @ │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xffb0f7ff │ │ │ │ - blcs 21b64 │ │ │ │ - blmi 284778 <__bss_end__@@Base+0x1ddb40> │ │ │ │ + blcs 222d4 │ │ │ │ + blmi 284ee8 <__bss_end__@@Base+0x1de348> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -pc, asr #26 │ │ │ │ ldmvs fp!, {r1, r2, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r7, r9, ip, sp, pc} │ │ │ │ movwcs r7, #4122 @ 0x101a │ │ │ │ movwcs lr, #4096 @ 0x1000 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq lr, r3, r4, ror #22 │ │ │ │ + andeq lr, r3, r4, lsl r5 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs r9!, {r0, r3, r4, r5, sp, lr} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -pc, lsl #31 │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - blcs aa51c <__bss_end__@@Base+0x38e4> │ │ │ │ - blcs c4544 <__bss_end__@@Base+0x1d90c> │ │ │ │ - blcs 46548 │ │ │ │ - blcs 843c4 <__bss_start@@Base+0x29324> │ │ │ │ + blcs aac8c <__bss_end__@@Base+0x40ec> │ │ │ │ + blcs c4cb4 <__bss_end__@@Base+0x1e114> │ │ │ │ + blcs 46cb8 │ │ │ │ + blcs 84b34 <__bss_start@@Base+0x29b2c> │ │ │ │ subs sp, pc, pc, lsr #32 │ │ │ │ rscsvs r2, fp, r1, lsl #6 │ │ │ │ movweq pc, #49415 @ 0xc107 @ │ │ │ │ - blcs 6e438 <__bss_start@@Base+0x13398> │ │ │ │ + blcs 6eba8 <__bss_start@@Base+0x13ba0> │ │ │ │ ldmdavs fp!, {r0, r1, r4, r8, ip, lr, pc} │ │ │ │ ldrmi r3, [r9], -r4, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fdf7 │ │ │ │ andle r2, r8, r0, lsl #22 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ ldc2l 7, cr15, [r0, #1020]! @ 0x3fc │ │ │ │ - blcs 21bf8 │ │ │ │ + blcs 22368 │ │ │ │ movwcs sp, #4097 @ 0x1001 │ │ │ │ movwcs lr, #72 @ 0x48 │ │ │ │ ldmdavs r9!, {r1, r2, r6, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r5, ror #27 │ │ │ │ andle r2, sl, r0, lsl #22 │ │ │ │ movwcc r6, #18491 @ 0x483b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ ldc2l 7, cr15, [ip, #1020] @ 0x3fc │ │ │ │ - blcs 21c20 │ │ │ │ + blcs 22390 │ │ │ │ movwcs sp, #4097 @ 0x1001 │ │ │ │ movwcs lr, #52 @ 0x34 │ │ │ │ movwcs lr, #4146 @ 0x1032 │ │ │ │ @ instruction: 0xf10760bb │ │ │ │ ldmdavc fp, {r3, r8, r9} │ │ │ │ tstle r3, r1, lsl #22 │ │ │ │ movwcc r6, #18491 @ 0x483b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ ldc2 7, cr15, [sl, #1020] @ 0x3fc │ │ │ │ - blcs 21c48 │ │ │ │ + blcs 223b8 │ │ │ │ ldmdavs r9!, {r3, ip, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fd93 │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ ands r2, r9, r1, lsl #6 │ │ │ │ ands r2, r7, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ stc2 7, cr15, [r8, #1020] @ 0x3fc │ │ │ │ - blcs 21c6c │ │ │ │ + blcs 223dc │ │ │ │ ldmdavs fp!, {r1, r3, ip, lr, pc} │ │ │ │ ldrmi r3, [r9], -r4, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fd7f │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ and r2, r5, r1, lsl #6 │ │ │ │ and r2, r3, r0, lsl #6 │ │ │ │ and r2, r1, r1, lsl #6 │ │ │ │ - stcl 7, cr15, [r2, #-968]! @ 0xfffffc38 │ │ │ │ + stmib r2, {r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ movwcs r6, #59 @ 0x3b │ │ │ │ ands r6, r1, fp, ror r1 │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr} │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldrmi r6, [sl], #-2234 @ 0xfffff746 │ │ │ │ @ instruction: 0x46116a3b │ │ │ │ @ instruction: 0x479868f8 │ │ │ │ - blcs 21cc4 │ │ │ │ + blcs 22434 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdbvs fp!, {r0, r1, r2, sp, lr, pc}^ │ │ │ │ cmnvs fp, r1, lsl #6 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ mvnle r4, #-1610612727 @ 0xa0000009 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ - blcs 2a6d4 │ │ │ │ + blcs 2ae44 │ │ │ │ movwcs sp, #4353 @ 0x1101 │ │ │ │ ldmvs r8!, {r2, r3, r5, sp, lr, pc}^ │ │ │ │ ldc2l 7, cr15, [r4], #1020 @ 0x3fc │ │ │ │ - blcs 61d04 <__bss_start@@Base+0x6c64> │ │ │ │ + blcs 62474 <__bss_start@@Base+0x746c> │ │ │ │ ldmdavs sl!, {r0, r1, r3, r8, ip, lr, pc}^ │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ ldc2 7, cr15, [r0, #1020] @ 0x3fc │ │ │ │ - blcs 21d14 │ │ │ │ + blcs 22484 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ movwcs lr, #4124 @ 0x101c │ │ │ │ ldmvs r8!, {r1, r3, r4, sp, lr, pc}^ │ │ │ │ stc2l 7, cr15, [r2], #1020 @ 0x3fc │ │ │ │ - blcs 21d28 │ │ │ │ + blcs 22498 │ │ │ │ ldmdavs sl!, {r0, r1, r3, r8, ip, lr, pc}^ │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ mcr2 7, 0, pc, cr0, cr15, {7} @ │ │ │ │ - blcs 21d38 │ │ │ │ + blcs 224a8 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ movwcs lr, #4106 @ 0x100a │ │ │ │ ldmvs r8!, {r3, sp, lr, pc}^ │ │ │ │ ldc2l 7, cr15, [r0], {255} @ 0xff │ │ │ │ - blcs a1d4c <__bss_start@@Base+0x46cac> │ │ │ │ + blcs a24bc <__bss_start@@Base+0x474b4> │ │ │ │ movwcs sp, #4353 @ 0x1101 │ │ │ │ movwcs lr, #0 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - svc 0x00a6f7f2 │ │ │ │ + bl ff0cec9c <__bss_end__@@Base+0xff0280fc> │ │ │ │ rscsvs r4, fp, r3, lsl #12 │ │ │ │ movweq pc, #49415 @ 0xc107 @ │ │ │ │ ldrmi r2, [r9], -r4, lsl #4 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603ffb1 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, sp, r0, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -fp, lsr #25 │ │ │ │ tstle r6, r1, lsl #22 │ │ │ │ @ instruction: 0x461868fb │ │ │ │ - ldc 7, cr15, [ip, #968]! @ 0x3c8 │ │ │ │ + ldmib lr, {r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r9, sl, lr} │ │ │ │ movwcs r6, #4122 @ 0x101a │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ @ instruction: 0x4618881b │ │ │ │ - ldcl 7, cr15, [sl, #-968] @ 0xfffffc38 │ │ │ │ + ldmdb ip!, {r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ mvnshi r4, r3, lsl #12 │ │ │ │ movweq pc, #57607 @ 0xe107 @ │ │ │ │ ldrmi r2, [r9], -r2, lsl #4 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r7, lsl #31 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, lr, r0, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r1, lsl #25 │ │ │ │ tstle r7, r1, lsl #22 │ │ │ │ @ instruction: 0x461889fb │ │ │ │ - mcr 7, 0, pc, cr10, cr2, {7} @ │ │ │ │ + b bced20 <__bss_end__@@Base+0xb28180> │ │ │ │ ldrmi r4, [sl], -r3, lsl #12 │ │ │ │ andshi r6, sl, fp, lsr r8 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ svcge 0x0000b082 │ │ │ │ eorsvs r6, r9, r8, ror r0 │ │ │ │ @@ -13309,35 +13812,35 @@ │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mcr2 7, 3, pc, cr8, cr15, {7} @ │ │ │ │ - blcs 21e3c │ │ │ │ + blcs 225ac │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r4, r7, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r4, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fe5d │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ add r2, r8, r0, lsl #6 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ mvnsmi pc, #683671552 @ 0x28c00000 │ │ │ │ - blcs 51f400 <__bss_end__@@Base+0x4787c8> │ │ │ │ + blcs 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#33219 @ 0x81c3 @ │ │ │ │ tstcs r0, sl, lsl r6 │ │ │ │ ldrbtmi r4, [fp], #-2850 @ 0xfffff4de │ │ │ │ @ instruction: 0xf7f24618 │ │ │ │ - ldmvs fp!, {r1, r4, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + ldmvs fp!, {r2, r4, r5, r6, r7, fp, sp, lr, pc} │ │ │ │ movweq pc, #33219 @ 0x81c3 @ │ │ │ │ - blmi 7e1f58 <__bss_end__@@Base+0x73b320> │ │ │ │ + blmi 7e26c8 <__bss_end__@@Base+0x73bb28> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fd17 │ │ │ │ @ instruction: 0xd12c2b00 │ │ │ │ eor r2, ip, r0, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r9, ror #23 │ │ │ │ @ instruction: 0xd1242b01 │ │ │ │ @ instruction: 0xf103683b │ │ │ │ movwcs r0, #4360 @ 0x1108 │ │ │ │ ldmdavs r8!, {r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldc2 7, cr15, [r0], #1020 @ 0x3fc │ │ │ │ - blcs 21f30 │ │ │ │ + blcs 226a0 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmvs fp!, {r0, r3, r4, sp, lr, pc}^ │ │ │ │ movweq pc, #28675 @ 0x7003 @ │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r7, sp, lr} │ │ │ │ andsle r2, r0, r0, lsl #22 │ │ │ │ @ instruction: 0xf1c368bb │ │ │ │ ldrmi r0, [sl], -r8, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2827 @ 0xfffff4f5 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2l 7, cr15, [ip], #-1020 @ 0xfffffc04 │ │ │ │ - blcs 21f5c │ │ │ │ + blcs 226cc │ │ │ │ movwcs sp, #259 @ 0x103 │ │ │ │ svclt 0x0000e003 │ │ │ │ svclt 0x0000e000 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - ldrdeq fp, [r4], -r6 │ │ │ │ - andeq fp, r4, r4, asr #1 │ │ │ │ - andeq fp, r4, r2, ror r0 │ │ │ │ + andeq sl, r4, lr, asr #17 │ │ │ │ + @ instruction: 0x0004a8bc │ │ │ │ + andeq sl, r4, sl, ror #16 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xff39f7ff │ │ │ │ - blcs 21f98 │ │ │ │ + blcs 22708 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r4, r5, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r1, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -lr, lsr #30 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eor r2, ip, r0, lsl #6 │ │ │ │ movwcc r6, #10299 @ 0x283b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mrc2 7, 7, pc, cr8, cr15, {7} │ │ │ │ - blcs 21fc4 │ │ │ │ + blcs 22734 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r5, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r4, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r3, asr #29 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, r6, r0, lsl #6 │ │ │ │ movwcc r6, #34875 @ 0x883b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mrc2 7, 5, pc, cr8, cr15, {7} │ │ │ │ - blcs 21ff0 │ │ │ │ + blcs 22760 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r3, sp, lr, pc} │ │ │ │ @ instruction: 0x46193310 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fdd5 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, r0, 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│ │ tstcc r2, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ ldc2 7, cr15, [lr], #1020 @ 0x3fc │ │ │ │ - blcs 229dc │ │ │ │ + blcs 2314c │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r2, r3, r6, sp, lr, pc} │ │ │ │ @ instruction: 0x46193318 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fcb3 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ sub r2, r2, r0, lsl #6 │ │ │ │ tstcc lr, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ ldc2l 7, cr15, [r1], #1020 @ 0x3fc │ │ │ │ - blcs 22a08 │ │ │ │ + blcs 23178 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r4, r5, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r4, lsr #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603f877 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eor r2, ip, r0, lsl #6 │ │ │ │ @ instruction: 0x3328683b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2l 7, cr15, [r7, #1020] @ 0x3fc │ │ │ │ - blcs 22a34 │ │ │ │ + blcs 231a4 │ │ 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│ - blcs 22ab4 │ │ │ │ + blcs 23224 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r7, sp, lr, pc} │ │ │ │ @ instruction: 0x46193312 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r7, asr #24 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ rsbs r2, r6, r0, lsl #6 │ │ │ │ tstcc r8, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ ldc2 7, cr15, [ip], #-1020 @ 0xfffffc04 │ │ │ │ - blcs 22ae0 │ │ │ │ + blcs 23250 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r5, r6, sp, lr, pc} │ │ │ │ @ instruction: 0x4619331e │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fc7a │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ rsb r2, r0, r0, lsl #6 │ │ │ │ @ instruction: 0x3324683b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx ffbcf2f8 <__bss_end__@@Base+0xffb286c0> │ │ │ │ - blcs 22b0c │ │ │ │ + blx ffbcfa68 <__bss_end__@@Base+0xffb28ec8> │ │ │ │ + blcs 2327c │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r2, r4, 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lsl #6 │ │ │ │ cmncc r6, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf912f7ff │ │ │ │ - blcs 22b90 │ │ │ │ + blcs 23300 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r4, sp, lr, pc} │ │ │ │ msreq SPSR_f, r3, lsl #2 │ │ │ │ @ instruction: 0xf893683b │ │ │ │ ldrmi r3, [sl], -r5, rrx │ │ │ │ ldrbtmi r4, [fp], #-2824 @ 0xfffff4f8 │ │ │ │ tstcs r8, #0, 6 │ │ │ │ @@ -14197,48 +14700,48 @@ │ │ │ │ @ instruction: 0x4619683b │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r6, lsl #25 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eor r2, r1, r0, lsl #6 │ │ │ │ movwcc r6, #51259 @ 0xc83b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx fe74f40e <__bss_end__@@Base+0xfe6a87d6> │ │ │ │ - blcs 22c20 │ │ │ │ + blx fe74fb7e <__bss_end__@@Base+0xfe6a8fde> │ │ │ │ + blcs 23390 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r1, r2, r4, sp, lr, pc} │ │ │ │ @ instruction: 0x46193312 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fb91 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, fp, r0, lsl #6 │ │ │ │ tstcc r8, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xffc2f7ff │ │ │ │ - blcs 22c4c │ │ │ │ + blcs 233bc │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ movwcs lr, #4096 @ 0x1000 │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mrrc2 7, 15, pc, r1, cr15 @ │ │ │ │ - blcs 22c74 │ │ │ │ + blcs 233e4 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r5, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -ip, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r7, ror #22 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, r6, r0, lsl #6 │ │ │ │ tstcc r2, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx 174f48e <__bss_end__@@Base+0x16a8856> │ │ │ │ - blcs 22ca0 │ │ │ │ + blx 174fbfe <__bss_end__@@Base+0x16a905e> │ │ │ │ + blcs 23410 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r3, sp, lr, pc} │ │ │ │ @ instruction: 0x46193318 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -sp, lsl #31 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, r0, r0, lsl #6 │ │ │ │ @@ -14250,122 +14753,122 @@ │ │ │ │ @ instruction: 0x4619683b │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fc1c │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eors r2, r7, r0, lsl #6 │ │ │ │ movwcc r6, #51259 @ 0xc83b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx ccf4e2 <__bss_end__@@Base+0xc288aa> │ │ │ │ - blcs 22cf4 │ │ │ │ + blx ccfc52 <__bss_end__@@Base+0xc290b2> │ │ │ │ + blcs 23464 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r2, r3, r5, sp, lr, pc} │ │ │ │ @ instruction: 0x46193312 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r7, lsr #22 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eor r2, r1, r0, lsl #6 │ │ │ │ tstcc r8, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ ldc2l 7, cr15, [fp], #-1020 @ 0xfffffc04 │ │ │ │ - blcs 22d20 │ │ │ │ + blcs 23490 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r1, r2, r4, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r0, lsr #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fc70 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, fp, r0, lsl #6 │ │ │ │ @ instruction: 0x3328683b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xff42f7ff │ │ │ │ - blcs 22d4c │ │ │ │ + blcs 234bc │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ movwcs lr, #4096 @ 0x1000 │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r2, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx ff48f562 <__bss_end__@@Base+0xff3e892a> │ │ │ │ - blcs 22d74 │ │ │ │ + blx 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0x101 │ │ │ │ ldmdavs fp!, {r1, r5, sp, lr, pc} │ │ │ │ msreq CPSR_, r3, lsl #2 │ │ │ │ ldmibvs sl, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ ldrbtmi r4, [fp], #-2832 @ 0xfffff4f0 │ │ │ │ movwcs r9, #33536 @ 0x8300 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ @ instruction: 0x4603fc9b │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, r1, r0, lsl #6 │ │ │ │ @ instruction: 0xf103683b │ │ │ │ ldmdavs fp!, {r2, r5, r8} │ │ │ │ - blmi 26bfcc <__bss_end__@@Base+0x1c5394> │ │ │ │ + blmi 26c73c <__bss_end__@@Base+0x1c5b9c> │ │ │ │ movwls r4, #1147 @ 0x47b │ │ │ │ ldmdavs r8!, {r4, r8, r9, sp}^ │ │ │ │ stc2 7, cr15, [sl], {254} @ 0xfe │ │ │ │ - blcs 23080 │ │ │ │ + blcs 237f0 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ movwcs lr, #4096 @ 0x1000 │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @ instruction: 0xfffff233 │ │ │ │ @ instruction: 0xffffedb1 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ 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instruction: 0x332e683b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mcr2 7, 2, pc, cr1, cr14, {7} @ │ │ │ │ - blcs 23188 │ │ │ │ + blcs 238f8 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r3, r5, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -pc, lsr #6 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ @ instruction: 0x4603fe36 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, lr, r0, lsl #6 │ │ │ │ teqcc r0, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2 7, cr15, [ip], #1016 @ 0x3f8 │ │ │ │ - blcs 231b4 │ │ │ │ + blcs 23924 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r4, sp, lr, pc} │ │ │ │ teqpeq r4, r3, lsl #2 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf893683b │ │ │ │ ldrmi r3, [sl], -sp, lsr #32 │ │ │ │ ldrbtmi r4, [fp], #-2824 @ 0xfffff4f8 │ │ │ │ movwcs r9, #33536 @ 0x8300 │ │ │ │ @@ -14576,79 +15079,79 @@ │ │ │ │ svclt 0x0000bd80 │ │ │ │ @ instruction: 0xfffffecb │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, 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#6 │ │ │ │ @@ -14666,48 +15169,48 @@ │ │ │ │ svclt 0x0000bd80 │ │ │ │ @ instruction: 0xfffffebb │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf8d3f7ff │ │ │ │ - blcs 23370 │ │ │ │ + blcs 23ae0 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r2, r3, r6, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -ip, lsl #6 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -r9, ror #31 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ sub r2, r2, r0, lsl #6 │ │ │ │ tstcc r2, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xffdef7fe │ │ │ │ - blcs 2339c │ │ │ │ + blcs 23b0c │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r4, r5, sp, lr, pc} │ │ │ │ @ instruction: 0x46193318 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -sp, lsr #23 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eor r2, ip, r0, lsl #6 │ │ │ │ tstcc ip, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2 7, cr15, [r1, #-1016]! @ 0xfffffc08 │ │ │ │ - blcs 233c8 │ │ │ │ + blcs 23b38 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r5, sp, lr, pc} │ │ │ │ @ instruction: 0x4619331d │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ @ instruction: 0x4603fd16 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, r6, r0, lsl #6 │ │ │ │ tstcc lr, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xffb2f7fe │ │ │ │ - blcs 233f4 │ │ │ │ + blcs 23b64 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r3, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r4, lsr #6 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -r1, lsl #23 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, r0, r0, lsl #6 │ │ │ │ @@ -14719,25 +15222,25 @@ │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ @ instruction: 0x4603f95f │ │ │ │ tstle r5, r1, lsl #22 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ rscsvs pc, r8, r5, ror #18 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf869f7ff │ │ │ │ - blcs 23444 │ │ │ │ + blcs 23bb4 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmvs r9!, {r1, r2, r3, r5, r6, r7, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -r6, ror #18 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ rsc r2, r5, r0, lsl #6 │ │ │ │ ldmvc fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ @ instruction: 0xdc3b2b17 │ │ │ │ vqdmlsl.s q9, d0, d0 │ │ │ │ - blcs 5f1f4c <__bss_end__@@Base+0x54b314> │ │ │ │ + blcs 5f26bc <__bss_end__@@Base+0x54bb1c> │ │ │ │ adcshi pc, r8, r0, lsl #4 │ │ │ │ @ instruction: 0xf852a202 │ │ │ │ ldrmi r3, [sl], #-35 @ 0xffffffdd │ │ │ │ svclt 0x00004710 │ │ │ │ andeq r0, r0, r7, rrx │ │ │ │ andeq r0, r0, fp, ror r0 │ │ │ │ muleq r0, pc, r0 @ │ │ │ │ @@ -14762,69 +15265,69 @@ │ │ │ │ andeq r0, r0, r5, ror #2 │ │ │ │ andeq r0, r0, sp, lsl r1 │ │ │ │ andeq r0, r0, pc, lsr #2 │ │ │ │ mlsle sp, ip, fp, r2 │ │ │ │ ldmdavs fp!, {r1, r2, r3, r4, r5, r6, sp, lr, pc} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf813f7ff │ │ │ │ - blcs 234f0 │ │ │ │ + blcs 23c60 │ │ │ │ movwcs sp, #382 @ 0x17e │ │ │ │ ldmdavs r9!, {r3, r4, r7, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -fp, asr #18 │ │ │ │ cmnle r7, r0, lsl #22 │ │ │ │ add r2, pc, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf9eef7ff │ │ │ │ - blcs 23514 │ │ │ │ + blcs 23c84 │ │ │ │ movwcs sp, #368 @ 0x170 │ │ │ │ ldmdavs r9!, {r1, r2, r7, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fa3b │ │ │ │ cmnle r9, r0, lsl #22 │ │ │ │ rsbs r2, sp, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ - blx fea8fd24 <__bss_end__@@Base+0xfe9e90ec> │ │ │ │ - blcs 23538 │ │ │ │ + blx fea90494 <__bss_end__@@Base+0xfe9e98f4> │ │ │ │ + blcs 23ca8 │ │ │ │ movwcs sp, #354 @ 0x162 │ │ │ │ ldmdavs r9!, {r2, r4, r5, r6, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fb56 │ │ │ │ cmple fp, r0, lsl #22 │ │ │ │ rsb r2, fp, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ - blx fe0cfd4a <__bss_end__@@Base+0xfe029112> │ │ │ │ - blcs 2355c │ │ │ │ + blx fe0d04ba <__bss_end__@@Base+0xfe02991a> │ │ │ │ + blcs 23ccc │ │ │ │ movwcs sp, #340 @ 0x154 │ │ │ │ ldmdavs r9!, {r1, r5, r6, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fbf9 │ │ │ │ cmple sp, r0, lsl #22 │ │ │ │ subs r2, r9, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ - blx fe98fd6e <__bss_end__@@Base+0xfe8e9136> │ │ │ │ - blcs 23580 │ │ │ │ + blx fe9904de <__bss_end__@@Base+0xfe8e993e> │ │ │ │ + blcs 23cf0 │ │ │ │ movwcs sp, #326 @ 0x146 │ │ │ │ ldmdavs r9!, {r4, r6, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fcdf │ │ │ │ teqle pc, r0, lsl #22 │ │ │ │ sub r2, r7, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ ldc2 7, cr15, [r6, #-1020] @ 0xfffffc04 │ │ │ │ - blcs 235a4 │ │ │ │ + blcs 23d14 │ │ │ │ movwcs sp, #312 @ 0x138 │ │ │ │ ldmdavs r9!, {r1, r2, r3, r4, r5, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fe73 │ │ │ │ teqle r1, r0, lsl #22 │ │ │ │ eors r2, r5, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ mcr2 7, 6, pc, cr10, cr15, {7} @ │ │ │ │ - blcs 235c8 │ │ │ │ + blcs 23d38 │ │ │ │ movwcs sp, #298 @ 0x12a │ │ │ │ ldmdavs r9!, {r2, r3, r5, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -fp, lsr #24 │ │ │ │ @ instruction: 0xd1232b00 │ │ │ │ eor r2, r3, r0, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2835 @ 0xfffff4ed │ │ │ │ @@ -14843,19 +15346,19 @@ │ │ │ │ and fp, r6, r0, lsl #30 │ │ │ │ and fp, r4, r0, lsl #30 │ │ │ │ and fp, r2, r0, lsl #30 │ │ │ │ and fp, r0, r0, lsl #30 │ │ │ │ movwcs fp, #7936 @ 0x1f00 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq sp, r3, lr, lsr #2 │ │ │ │ + ldrdeq ip, [r3], -lr │ │ │ │ umulllt fp, r9, r0, r5 │ │ │ │ rsbsvs sl, r8, r4, lsl #30 │ │ │ │ - bvs fe6ec020 <__bss_end__@@Base+0xfe6453e8> │ │ │ │ - blcc 2347a4 <__bss_end__@@Base+0x18db6c> │ │ │ │ + bvs fe6ec790 <__bss_end__@@Base+0xfe645bf0> │ │ │ │ + blcc 234f14 <__bss_end__@@Base+0x18e374> │ │ │ │ stmdale r3, {r3, r4, r8, r9, fp, sp}^ │ │ │ │ @ instruction: 0xf852a202 │ │ │ │ ldrmi r3, [sl], #-35 @ 0xffffffdd │ │ │ │ svclt 0x00004710 │ │ │ │ andeq r0, r0, r5, rrx │ │ │ │ andeq r0, r0, sp, ror r0 │ │ │ │ andeq r0, r0, sp, ror r0 │ │ │ │ @@ -14883,483 +15386,483 @@ │ │ │ │ andeq r0, r0, r7, ror r0 │ │ │ │ rscsvs r2, fp, r1, lsl #6 │ │ │ │ movwcs lr, #8218 @ 0x201a │ │ │ │ ldrsh r6, [r7], -fp │ │ │ │ rscsvs r2, fp, r6, lsl #6 │ │ │ │ movwcs lr, #40980 @ 0xa014 │ │ │ │ ldrsh r6, [r1], -fp │ │ │ │ - bvs fe6ec0b4 <__bss_end__@@Base+0xfe64547c> │ │ │ │ + bvs fe6ec824 <__bss_end__@@Base+0xfe645c84> │ │ │ │ ldmdavs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ - bhi 16ec93c <__bss_end__@@Base+0x1645d04> │ │ │ │ + bhi 16ed0ac <__bss_end__@@Base+0x164650c> │ │ │ │ ldrmi r9, [r3], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [sl], #-2590 @ 0xfffff5e2 │ │ │ │ msrcs R10_usr, r0 │ │ │ │ ldrbtmi r4, [r8], #-2077 @ 0xfffff7e3 │ │ │ │ stc2 0, cr15, [r2] │ │ │ │ - ldmda r0!, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + mrrc 7, 15, pc, r0, cr0 @ │ │ │ │ ldmdavs r8, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - bvs fe6ec0dc <__bss_end__@@Base+0xfe6454a4> │ │ │ │ + bvs fe6ec84c <__bss_end__@@Base+0xfe645cac> │ │ │ │ @ instruction: 0x461988db │ │ │ │ ldmibvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ movvs pc, #72, 4 @ 0x80000004 │ │ │ │ movweq pc, #4800 @ 0x12c0 @ │ │ │ │ movwcs r9, #4866 @ 0x1302 │ │ │ │ andls r9, r0, #67108864 @ 0x4000000 │ │ │ │ andcs r4, r3, #11534336 @ 0xb00000 │ │ │ │ - @ instruction: 0xf7f168f9 │ │ │ │ - ldrsbtvs lr, [r8], r2 │ │ │ │ - blcs 2c204 │ │ │ │ + @ instruction: 0xf7f068f9 │ │ │ │ + ldrshtvs lr, [r8], r6 │ │ │ │ + blcs 2c974 │ │ │ │ ldmdavs fp!, {r0, r2, r4, ip, lr, pc}^ │ │ │ │ ldmdavs ip, {r0, r1, r3, r4, r7, r9, fp, sp, lr} │ │ │ │ - @ instruction: 0xf7f168b8 │ │ │ │ - @ instruction: 0x4603e998 │ │ │ │ - blmi 2f6b30 <__bss_end__@@Base+0x24fef8> │ │ │ │ + @ instruction: 0xf7f068b8 │ │ │ │ + @ instruction: 0x4603edbc │ │ │ │ + blmi 2f72a0 <__bss_end__@@Base+0x250700> │ │ │ │ movwls r4, #1147 @ 0x47b │ │ │ │ - bmi 2a37c0 <__bss_end__@@Base+0x1fcb88> │ │ │ │ + bmi 2a3f30 <__bss_end__@@Base+0x1fd390> │ │ │ │ vqshl.s8 q10, q13, q0 │ │ │ │ stmdami r9, {r0, r1, r2, r3, r5, r8, sp} │ │ │ │ @ instruction: 0xf0004478 │ │ │ │ - @ instruction: 0xf7f1fc73 │ │ │ │ - svclt 0x0000e802 │ │ │ │ + @ instruction: 0xf7f0fc73 │ │ │ │ + svclt 0x0000ec22 │ │ │ │ ssatmi r3, #30, r4, lsl #14 │ │ │ │ svclt 0x0000bd90 │ │ │ │ - andeq sp, r3, r2, asr r0 │ │ │ │ - andeq sp, r3, sl, ror r0 │ │ │ │ - andeq sp, r3, r8, rrx │ │ │ │ - andeq sp, r3, ip, lsr #32 │ │ │ │ - andeq sp, r3, ip, lsl r0 │ │ │ │ + andeq ip, r3, r2, lsl #20 │ │ │ │ + andeq ip, r3, sl, lsr #20 │ │ │ │ + andeq ip, r3, r8, lsl sl │ │ │ │ + ldrdeq ip, [r3], -ip @ │ │ │ │ + andeq ip, r3, ip, asr #19 │ │ │ │ addlt fp, sl, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r7, r9, fp, sp, lr}^ │ │ │ │ - blvs eea668 <__bss_end__@@Base+0xe43a30> │ │ │ │ + blvs eeadd8 <__bss_end__@@Base+0xe44238> │ │ │ │ @ instruction: 0x461869b9 │ │ │ │ - @ instruction: 0xf9def037 │ │ │ │ + stc2l 0, cr15, [sl, #216]! @ 0xd8 │ │ │ │ ldrmi r4, [sl], -fp, lsl #12 │ │ │ │ - bne fe6ecc78 <__bss_end__@@Base+0xfe646040> │ │ │ │ + bne fe6ed3e8 <__bss_end__@@Base+0xfe646848> │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r8, r9, sp, lr}^ │ │ │ │ addsmi r6, sl, #3063808 @ 0x2ec000 │ │ │ │ - blmi f087bc <__bss_end__@@Base+0xe61b84> │ │ │ │ + blmi f08f2c <__bss_end__@@Base+0xe6238c> │ │ │ │ vst3.16 {d20-d22}, [pc :256], fp │ │ │ │ ldmdbmi sl!, {r0, r2, r4, r9, ip, sp, lr} │ │ │ │ ldmdami sl!, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ - @ instruction: 0xf7f14478 │ │ │ │ - blvs ecc244 <__bss_end__@@Base+0xe2560c> │ │ │ │ + @ instruction: 0xf7f04478 │ │ │ │ + blvs ecda3c <__bss_end__@@Base+0xe26e9c> │ │ │ │ addsmi r6, sl, #3063808 @ 0x2ec000 │ │ │ │ - blmi e087d8 <__bss_end__@@Base+0xd61ba0> │ │ │ │ + blmi e08f48 <__bss_end__@@Base+0xd623a8> │ │ │ │ vqshl.s8 q10, , q0 │ │ │ │ ldmdbmi r6!, {r0, r2, r4, r6, r9, sp} │ │ │ │ ldmdami r6!, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ - @ instruction: 0xf7f14478 │ │ │ │ - ldmvs fp!, {r3, r4, r7, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7f04478 │ │ │ │ + ldmvs fp!, {r1, r3, r4, r5, r7, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xee0769db │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ ldmvs fp!, {r0, r1, r2, r5, r6, r8, r9, fp, ip, lr}^ │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r7, r9, fp, sp, lr} │ │ │ │ - bcc fe44d7f8 <__bss_end__@@Base+0xfe3a6bc0> │ │ │ │ - blvs 1a0dac0 <__bss_end__@@Base+0x1966e88> │ │ │ │ - blvc 1cd9f8 <__bss_end__@@Base+0x126dc0> │ │ │ │ - blvc 14d604 <__bss_end__@@Base+0xa69cc> │ │ │ │ + bcc fe44df68 <__bss_end__@@Base+0xfe3a73c8> │ │ │ │ + blvs 1a0e230 <__bss_end__@@Base+0x1967690> │ │ │ │ + blvc 1ce168 <__bss_end__@@Base+0x1275c8> │ │ │ │ + blvc 14dd74 <__bss_end__@@Base+0xa71d4> │ │ │ │ rsbsvs r2, fp, #0, 6 │ │ │ │ eorsvs r2, fp, #0, 6 │ │ │ │ mvnsvs r2, r0, lsl #6 │ │ │ │ @ instruction: 0xee0769fb │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ vldr d6, [r7, #924] @ 0x39c │ │ │ │ vmul.f64 d7, d6, d4 │ │ │ │ vmov.f64 d7, #103 @ 0x3f380000 0.7187500 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ vmov.f64 d23, #214 @ 0xbeb00000 -0.3437500 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ ldmibvs fp!, {r4, r7, r9, fp, sp} │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ - bvs 1eaaa0c <__bss_end__@@Base+0x1e03dd4> │ │ │ │ + bvs 1eab17c <__bss_end__@@Base+0x1e045dc> │ │ │ │ addsmi r6, sl, #8060928 @ 0x7b0000 │ │ │ │ - bvs f0887c <__bss_end__@@Base+0xe61c44> │ │ │ │ + bvs f08fec <__bss_end__@@Base+0xe6244c> │ │ │ │ ldmne r0, {r1, r3, r4, r5, fp, sp, lr}^ │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, r9, fp, sp, lr} │ │ │ │ ldmibvs sl!, {r0, r1, r4, sl, lr} │ │ │ │ - @ instruction: 0xf7f14619 │ │ │ │ - bvs ecc424 <__bss_end__@@Base+0xe257ec> │ │ │ │ + @ instruction: 0xf7f04619 │ │ │ │ + bvs ecdc24 <__bss_end__@@Base+0xe27084> │ │ │ │ ldrmi r6, [r3], #-2491 @ 0xfffff645 │ │ │ │ ldmibvs fp!, {r0, r1, r3, r4, r5, r9, sp, lr}^ │ │ │ │ mvnsvs r3, r1, lsl #6 │ │ │ │ - blvs eec934 <__bss_end__@@Base+0xe45cfc> │ │ │ │ - blle ff462ab8 <__bss_end__@@Base+0xff3bbe80> │ │ │ │ + blvs eed0a4 <__bss_end__@@Base+0xe46504> │ │ │ │ + blle ff463228 <__bss_end__@@Base+0xff3bc688> │ │ │ │ svclt 0x0000e000 │ │ │ │ ldmibvs fp!, {r1, r3, r4, r5, r6, r9, fp, sp, lr} │ │ │ │ - ble a2ac4 <__bss_start@@Base+0x47a24> │ │ │ │ + ble a3234 <__bss_start@@Base+0x4822c> │ │ │ │ rsbsvs r6, fp, #3063808 @ 0x2ec000 │ │ │ │ - bvs 1eca078 <__bss_end__@@Base+0x1e23440> │ │ │ │ + bvs 1eca7e8 <__bss_end__@@Base+0x1e23c48> │ │ │ │ addsmi r6, sl, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r0, r8, sl, fp, ip, lr, pc}^ │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r9, sp, lr}^ │ │ │ │ - bvs 1eec9dc <__bss_end__@@Base+0x1e45da4> │ │ │ │ + bvs 1eed14c <__bss_end__@@Base+0x1e465ac> │ │ │ │ ldmvs fp!, {r1, r3, r4, sl, lr}^ │ │ │ │ - bvs eea9e4 <__bss_end__@@Base+0xe43dac> │ │ │ │ + bvs eeb154 <__bss_end__@@Base+0xe445b4> │ │ │ │ @ instruction: 0x37284618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq sp, r3, r4, lsr #3 │ │ │ │ - @ instruction: 0x0003cfb8 │ │ │ │ - strdeq ip, [r3], -r8 │ │ │ │ - andeq sp, r3, r8, lsl #3 │ │ │ │ - muleq r3, ip, pc @ │ │ │ │ - strdeq ip, [r3], -r4 │ │ │ │ + andeq ip, r3, r4, asr fp │ │ │ │ + andeq ip, r3, r8, ror #18 │ │ │ │ + andeq ip, r3, r8, lsr #19 │ │ │ │ + andeq ip, r3, r8, lsr fp │ │ │ │ + andeq ip, r3, ip, asr #18 │ │ │ │ + andeq ip, r3, r4, lsr #19 │ │ │ │ @ instruction: 0xb088b5b0 │ │ │ │ rscsvs sl, r8, r2, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, 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sp, lr, pc} │ │ │ │ + ldcl 7, cr15, [sl], {240} @ 0xf0 │ │ │ │ movwls r4, #5635 @ 0x1603 │ │ │ │ strtmi r9, [r3], -r0, lsl #10 │ │ │ │ ldrbtmi r4, [sl], #-2568 @ 0xfffff5f8 │ │ │ │ cmnpcs r5, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [r8], #-2055 @ 0xfffff7f9 │ │ │ │ - blx fe54e102 <__bss_end__@@Base+0xfe4a74ca> │ │ │ │ - svc 0x0022f7f0 │ │ │ │ + blx fe54e872 <__bss_end__@@Base+0xfe4a7cd2> │ │ │ │ + bl 10d0834 <__bss_end__@@Base+0x1029c94> │ │ │ │ cmnvs fp, r0, lsl #6 │ │ │ │ @ instruction: 0x4618697b │ │ │ │ ssatmi r3, #30, r8, lsl #14 │ │ │ │ svclt 0x0000bdb0 │ │ │ │ - ldrdeq ip, [r3], -sl │ │ │ │ - andeq ip, r3, lr, asr lr │ │ │ │ + andeq ip, r3, sl, lsl #17 │ │ │ │ + andeq ip, r3, lr, lsl #16 │ │ │ │ umullslt fp, r3, r0, r5 │ │ │ │ rsbsvs sl, r8, r2, lsl #30 │ │ │ │ mvnsvs r6, fp, ror r8 │ │ │ │ mvnsvs r2, #0, 6 │ │ │ │ @ instruction: 0x63bb2300 │ │ │ │ cmnvs fp, #0, 6 │ │ │ │ movwcs lr, #4468 @ 0x1174 │ │ │ │ ldmibvs fp!, {r0, r1, r3, r4, r5, r6, r9, sp, lr}^ │ │ │ │ - blcs 2c6ac │ │ │ │ + blcs 2ce1c │ │ │ │ ldmibvs fp!, {r1, r2, r3, r5, ip, lr, pc}^ │ │ │ │ ldmibvs fp!, {r1, r3, r4, r7, r8, fp, sp, lr}^ │ │ │ │ ldmibvs fp!, {r1, r3, r4, r6, r9, sp, lr}^ │ │ │ │ - blcs 2cabc │ │ │ │ + blcs 2d22c │ │ │ │ ldmibvs fp!, {r0, r1, r9, fp, ip, lr, pc}^ │ │ │ │ subsvs r2, sl, #0, 4 │ │ │ │ ldmibvs fp!, {r0, r2, r3, sp, lr, pc}^ │ │ │ │ @ instruction: 0x461a6a5b │ │ │ │ - bvs fe6ec950 <__bss_end__@@Base+0xfe645d18> │ │ │ │ + bvs fe6ed0c0 <__bss_end__@@Base+0xfe646520> │ │ │ │ addsmi r6, sl, #2539520 @ 0x26c000 │ │ │ │ ldmibvs fp!, {r0, r2, r8, fp, ip, lr, pc}^ │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r7, r9, fp, sp, lr} │ │ │ │ ldmibvs fp!, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ ldmibvs fp!, {r1, r3, r4, r6, r9, sp, lr}^ │ │ │ │ @ instruction: 0x461c6a5b │ │ │ │ - bvs 16ec96c <__bss_end__@@Base+0x1645d34> │ │ │ │ + bvs 16ed0dc <__bss_end__@@Base+0x164653c> │ │ │ │ ldmibvs fp!, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r7, r9, fp, sp, lr}^ │ │ │ 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0x4603f953 │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ eorle r2, lr, r0, lsl #22 │ │ │ │ - blvs 1eacea0 <__bss_end__@@Base+0x1e06268> │ │ │ │ + blvs 1ead610 <__bss_end__@@Base+0x1e06a70> │ │ │ │ ldmdbvs sl!, {r0, r1, r4, sl, lr}^ │ │ │ │ ldmibvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mcr2 7, 3, pc, cr14, cr15, {7} @ │ │ │ │ ldmdbvs fp!, {r3, r4, r5, r8, sp, lr} │ │ │ │ vstmdble r2!, {d2-d1} │ │ │ │ - bvs fe6ecbb8 <__bss_end__@@Base+0xfe645f80> │ │ │ │ + bvs fe6ed328 <__bss_end__@@Base+0xfe646788> │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r6, r8, fp, sp, lr} │ │ │ │ vqdmulh.s d15, d2, d3 │ │ │ │ ldrmi r6, [r3], #-2747 @ 0xfffff545 │ │ │ │ - bvs feeaaec8 <__bss_end__@@Base+0xfee04290> │ │ │ │ + bvs feeab638 <__bss_end__@@Base+0xfee04a98> │ │ │ │ addsmi r6, sl, #1028096 @ 0xfb000 │ │ │ │ movwcs sp, #2819 @ 0xb03 │ │ │ │ movwcs r6, #699 @ 0x2bb │ │ │ │ movwcs r6, #763 @ 0x2fb │ │ │ │ and r6, lr, fp, ror r2 │ │ │ │ - bvs 16ecbe0 <__bss_end__@@Base+0x1645fa8> │ │ │ │ + bvs 16ed350 <__bss_end__@@Base+0x16467b0> │ │ │ │ ldmibvs fp!, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r7, r9, fp, sp, lr} │ │ │ │ movwle r4, #25242 @ 0x629a │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf7f04618 │ │ │ │ - movwcs lr, #7756 @ 0x1e4c │ │ │ │ - bvs 1eeb2fc <__bss_end__@@Base+0x1e446c4> │ │ │ │ + movwcs lr, #6766 @ 0x1a6e │ │ │ │ + bvs 1eeba6c <__bss_end__@@Base+0x1e44ecc> │ │ │ │ andle r2, r5, r0, lsl #22 │ │ │ │ adcvs pc, r0, r8, asr #4 │ │ │ │ andeq pc, r1, r0, asr #5 │ │ │ │ - mrc 7, 3, APSR_nzcv, cr12, cr0, {7} │ │ │ │ + b fe7d0b50 <__bss_end__@@Base+0xfe729fb0> │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf43f2b00 │ │ │ │ - blvs 1e3de44 <__bss_end__@@Base+0x1d9720c> │ │ │ │ - blx fe3ce436 <__bss_end__@@Base+0xfe3277fe> │ │ │ │ + blvs 1e3e5b4 <__bss_end__@@Base+0x1d97a14> │ │ │ │ + @ instruction: 0xf842f001 │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ ldrtmi r3, [sp], r4, asr #14 │ │ │ │ svclt 0x0000bd90 │ │ │ │ - muleq r3, r2, pc @ │ │ │ │ - muleq r3, r6, sp │ │ │ │ - andeq ip, r3, lr, ror #28 │ │ │ │ - ldrdeq ip, [r3], -r0 │ │ │ │ - ldrdeq ip, [r3], -r2 │ │ │ │ - andeq ip, r3, sl, lsr #27 │ │ │ │ - andeq ip, r3, sl, lsl #25 │ │ │ │ + andeq ip, r3, r2, asr #18 │ │ │ │ + andeq ip, r3, r6, asr #14 │ │ │ │ + andeq ip, r3, lr, lsl r8 │ │ │ │ + andeq ip, r3, r0, lsl #13 │ │ │ │ + andeq ip, r3, r2, lsl #13 │ │ │ │ + andeq ip, r3, sl, asr r7 │ │ │ │ + andeq ip, r3, sl, lsr r6 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ rscsvs r6, fp, fp, ror r8 │ │ │ │ andcs r6, r1, #16449536 @ 0xfb0000 │ │ │ │ ldmvs fp!, {r1, r3, r4, r6, r7, sp, lr}^ │ │ │ │ tstcs r0, fp, asr r8 │ │ │ │ @ instruction: 0xf7f04618 │ │ │ │ - ldmvs fp!, {r2, r3, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmvs fp!, {r2, r3, r5, r6, r8, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - ldcl 7, cr15, [lr, #-960] @ 0xfffffc40 │ │ │ │ - bvs fe6ec870 <__bss_end__@@Base+0xfe645c38> │ │ │ │ + ldmdb lr!, {r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + bvs fe6ecfe0 <__bss_end__@@Base+0xfe646440> │ │ │ │ @ instruction: 0xf0014618 │ │ │ │ - svclt 0x0000fb61 │ │ │ │ + svclt 0x0000f815 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ svcge 0x0002b086 │ │ │ │ - blmi d2a67c <__bss_end__@@Base+0xc83a44> │ │ │ │ + blmi d2adec <__bss_end__@@Base+0xc8424c> │ │ │ │ eorcs r4, ip, #2063597568 @ 0x7b000000 │ │ │ │ tstpcc fp, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [r8], #-2098 @ 0xfffff7ce │ │ │ │ - blx fe84e4b0 <__bss_end__@@Base+0xfe7a7878> │ │ │ │ + @ instruction: 0xff54f000 │ │ │ │ eorcs r6, ip, #248 @ 0xf8 │ │ │ │ ldmvs r8!, {r8, sp}^ │ │ │ │ - stcl 7, cr15, [r8, #960]! @ 0x3c0 │ │ │ │ + b 2d0be8 <__bss_end__@@Base+0x22a048> │ │ │ │ @ instruction: 0xf0036878 │ │ │ │ - @ instruction: 0x4602fc11 │ │ │ │ + @ instruction: 0x4602f81d │ │ │ │ addsvs r6, sl, #16449536 @ 0xfb0000 │ │ │ │ - bvs fe6ec8b4 <__bss_end__@@Base+0xfe645c7c> │ │ │ │ - blcs 74738 <__bss_start@@Base+0x19698> │ │ │ │ + bvs fe6ed024 <__bss_end__@@Base+0xfe646484> │ │ │ │ + blcs 74ea8 <__bss_start@@Base+0x19ea0> │ │ │ │ ldmvs fp!, {r1, r2, r3, ip, lr, pc}^ │ │ │ │ ldmhi fp, {r0, r1, r3, r4, r7, r9, fp, sp, lr} │ │ │ │ ldmdavs fp!, {r8, r9, ip, pc}^ │ │ │ │ ldrbtmi r4, [sl], #-2598 @ 0xfffff5da │ │ │ │ msrcc R9_usr, r0 │ │ │ │ ldrbtmi r4, [r8], #-2085 @ 0xfffff7db │ │ │ │ @ instruction: 0xf9a0f000 │ │ │ │ - stc 7, cr15, [lr, #-960]! @ 0xfffffc40 │ │ │ │ + stmdb lr, {r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ movwcs r6, #2296 @ 0x8f8 │ │ │ │ stmdbmi r2!, {r9, sp} │ │ │ │ @ instruction: 0xf7f04479 │ │ │ │ - adcsvs lr, r8, ip, lsl lr │ │ │ │ - blcs 2c7ec │ │ │ │ + adcsvs lr, r8, lr, lsr sl │ │ │ │ + blcs 2cf5c │ │ │ │ ldmvs r8!, {r4, ip, lr, pc} │ │ │ │ - mcr 7, 5, pc, cr6, cr0, {7} @ │ │ │ │ + b ff2d0c38 <__bss_end__@@Base+0xff22a098> │ │ │ │ movwls r4, #1539 @ 0x603 │ │ │ │ ldrbtmi r4, [fp], #-2844 @ 0xfffff4e4 │ │ │ │ ldrbtmi r4, [sl], #-2588 @ 0xfffff5e4 │ │ │ │ msrcc (UNDEF: 39), r0 │ │ │ │ ldrbtmi r4, [r8], #-2075 @ 0xfffff7e5 │ │ │ │ @ instruction: 0xf984f000 │ │ │ │ - ldc 7, cr15, [r2, #-960] @ 0xfffffc40 │ │ │ │ + ldmdb r2!, {r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ andcs r6, r1, #16449536 @ 0xfb0000 │ │ │ │ ldmvs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r7, r9, fp, sp, lr} │ │ │ │ ldrshvs r6, [sl, #139] @ 0x8b │ │ │ │ @ instruction: 0xf7ff68f8 │ │ │ │ ldmvs fp!, {r0, r1, r2, r4, r5, r6, sl, fp, ip, sp, lr, pc}^ │ │ │ │ ldmvs fp!, {r3, r4, r8, sl, fp, ip}^ │ │ │ │ ldrbtmi r4, [sl], #-2578 @ 0xfffff5ee │ │ │ │ @ instruction: 0xf7f02100 │ │ │ │ - ldrshtvs lr, [r8], sl │ │ │ │ - blcs 2c83c │ │ │ │ + adcsvs lr, r8, ip, lsl sl │ │ │ │ + blcs 2cfac │ │ │ │ ldmdavs sl!, {r1, r2, ip, lr, pc}^ │ │ │ │ - blmi 3ac83c <__bss_end__@@Base+0x305c04> │ │ │ │ + blmi 3acfac <__bss_end__@@Base+0x30640c> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ @ instruction: 0xf9aef000 │ │ │ │ @ instruction: 0x461868fb │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ @ instruction: 0xffffffb9 │ │ │ │ - @ instruction: 0x0003cab2 │ │ │ │ - @ instruction: 0x0003cbb6 │ │ │ │ - andeq ip, r3, r6, ror sl │ │ │ │ - andeq ip, r3, r0, lsr #21 │ │ │ │ - andeq ip, r3, r6, lsl #21 │ │ │ │ - @ instruction: 0x0003cbba │ │ │ │ - andeq ip, r3, lr, lsr sl │ │ │ │ + andeq ip, r3, r2, ror #8 │ │ │ │ + andeq ip, r3, r6, ror #10 │ │ │ │ + andeq ip, r3, r6, lsr #8 │ │ │ │ + andeq ip, r3, r0, asr r4 │ │ │ │ + andeq ip, r3, r6, lsr r4 │ │ │ │ + andeq ip, r3, sl, ror #10 │ │ │ │ + andeq ip, r3, lr, ror #7 │ │ │ │ @ instruction: 0xfffffbd7 │ │ │ │ - muleq r3, r4, fp │ │ │ │ + andeq ip, r3, r4, asr #10 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ andle r2, r2, r0, lsl #22 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ svclt 0x0000609a │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 150728 <__bss_end__@@Base+0xa9af0> │ │ │ │ + blvc 150e98 <__bss_end__@@Base+0xaa2f8> │ │ │ │ strlt r4, [r0], #1904 @ 0x770 │ │ │ │ svcge 0x0000b083 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ - blcs 2c830 │ │ │ │ + blcs 2cfa0 │ │ │ │ ldmdavs fp!, {r0, r3, r8, ip, lr, pc}^ │ │ │ │ @ instruction: 0x461a6a5b │ │ │ │ - bvs fe6ec7bc <__bss_end__@@Base+0xfe645b84> │ │ │ │ + bvs fe6ecf2c <__bss_end__@@Base+0xfe64638c> │ │ │ │ addsmi r6, sl, #2539520 @ 0x26c000 │ │ │ │ movwcs sp, #4609 @ 0x1201 │ │ │ │ movwcs lr, #0 │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ tstle r2, r0, lsl #22 │ │ │ │ andcs r6, r1, #8060928 @ 0x7b0000 │ │ │ │ svclt 0x0000609a │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 15077c <__bss_end__@@Base+0xa9b44> │ │ │ │ + blvc 150eec <__bss_end__@@Base+0xaa34c> │ │ │ │ strlt r4, [r0], #1904 @ 0x770 │ │ │ │ svcge 0x0000b083 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ - blcs 2c884 │ │ │ │ + blcs 2cff4 │ │ │ │ movwcs fp, #7948 @ 0x1f0c │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @@ -15372,103 +15875,103 @@ │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - bvs fe6ec858 <__bss_end__@@Base+0xfe645c20> │ │ │ │ + bvs fe6ecfc8 <__bss_end__@@Base+0xfe646428> │ │ │ │ vst2.32 {d22,d24}, [pc :64], fp │ │ │ │ - blx af05e <__bss_end__@@Base+0x8426> │ │ │ │ + blx af7ce <__bss_end__@@Base+0x8c2e> │ │ │ │ ldmdavs fp!, {r0, r1, ip, sp, lr, pc}^ │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r7, r9, fp, sp, lr} │ │ │ │ - bvs fe4ac868 <__bss_end__@@Base+0xfe405c30> │ │ │ │ - blx b49ce <__bss_end__@@Base+0xdd96> │ │ │ │ + bvs fe4acfd8 <__bss_end__@@Base+0xfe406438> │ │ │ │ + blx b513e <__bss_end__@@Base+0xe59e> │ │ │ │ ldmdavs sl!, {r0, r1, r8, r9, ip, sp, lr, pc}^ │ │ │ │ - bhi 4ad0d4 <__bss_end__@@Base+0x40649c> │ │ │ │ + bhi 4ad844 <__bss_end__@@Base+0x406ca4> │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ - @ instruction: 0xf0364619 │ │ │ │ - strmi pc, [r3], -pc, asr #23 │ │ │ │ + @ instruction: 0xf0354619 │ │ │ │ + @ instruction: 0x4603ffdb │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - bvs fe6ec898 <__bss_end__@@Base+0xfe645c60> │ │ │ │ + bvs fe6ed008 <__bss_end__@@Base+0xfe646468> │ │ │ │ vst2.32 {d22,d24}, [pc :64], fp │ │ │ │ - blx af09e <__bss_end__@@Base+0x8466> │ │ │ │ + blx af80e <__bss_end__@@Base+0x8c6e> │ │ │ │ ldmdavs fp!, {r0, r1, ip, sp, lr, pc}^ │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r6, r7, r8, fp, sp, lr}^ │ │ │ │ ldmhi r2, {r1, r4, r7, r9, fp, sp, lr}^ │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ - bvs fe4ac8b0 <__bss_end__@@Base+0xfe405c78> │ │ │ │ - blx b4f16 <__bss_end__@@Base+0xe2de> │ │ │ │ + bvs fe4ad020 <__bss_end__@@Base+0xfe406480> │ │ │ │ + blx b5686 <__bss_end__@@Base+0xeae6> │ │ │ │ ldrmi pc, [r9], -r3, lsl #6 │ │ │ │ - blx fec4e7ae <__bss_end__@@Base+0xfeba7b76> │ │ │ │ + @ instruction: 0xffbcf035 │ │ │ │ ldrmi r4, [r8], -r3, lsl #12 │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ svcge 0x0000b082 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ vst1.16 {d22-d23}, [pc :64], fp │ │ │ │ - blx af0da <__bss_end__@@Base+0x84a2> │ │ │ │ + blx af84a <__bss_end__@@Base+0x8caa> │ │ │ │ ldrmi pc, [r8], -r3, lsl #6 │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - bvs fe4ac8e4 <__bss_end__@@Base+0xfe405cac> │ │ │ │ - blx b4a4a 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│ │ - andcs lr, r1, sl, lsl #26 │ │ │ │ - mcr 7, 0, pc, cr10, cr0, {7} @ │ │ │ │ - ldrdeq r5, [r4], -r4 │ │ │ │ - andeq r0, r0, r0, lsl r3 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r7, r4, r4, asr #24 │ │ │ │ - andeq ip, r3, sl, lsl r8 │ │ │ │ - andeq r0, r0, r0 │ │ │ │ - addlt fp, r8, r0, lsl #11 │ │ │ │ - blmi f3e5ac <__bss_end__@@Base+0xe97974> │ │ │ │ - ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - cmnle fp, r0, lsl #22 │ │ │ │ - ldrbtmi r4, [fp], #-2874 @ 0xfffff4c6 │ │ │ │ - andsvs r2, sl, r1, lsl #4 │ │ │ │ - andeq pc, r0, #79 @ 0x4f │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ - movwcs lr, #18887 @ 0x49c7 │ │ │ │ - blne 14e02c <__bss_end__@@Base+0xa73f4> │ │ │ │ - bleq c4e050 <__bss_end__@@Base+0xba7418> │ │ │ │ - stcl 7, cr15, [ip, #960] @ 0x3c0 │ │ │ │ - blvs 104e49c <__bss_end__@@Base+0xfa7864> │ │ │ │ - blpl b8e05c <__bss_end__@@Base+0xae7424> │ │ │ │ - blvc 1ce3f8 <__bss_end__@@Base+0x1277c0> │ │ │ │ - blvc ce004 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│ │ │ │ - @ instruction: 0x17cb10da │ │ │ │ - @ instruction: 0x46131ad2 │ │ │ │ - ldrmi r0, [r3], #-283 @ 0xfffffee5 │ │ │ │ - tsteq r2, sl, asr #21 │ │ │ │ - andsvs r6, sl, fp, ror r8 │ │ │ │ - ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - vstrle d2, [r2, #-1020] @ 0xfffffc04 │ │ │ │ - rscscs r6, pc, #8060928 @ 0x7b0000 │ │ │ │ - ldmvs sl!, {r1, r3, r4, sp, lr}^ │ │ │ │ - cmnpeq r9, #74448896 @ p-variant is OBSOLETE @ 0x4700000 │ │ │ │ - cmnpeq r8, #208666624 @ p-variant is OBSOLETE @ 0xc700000 │ │ │ │ - movwne pc, #11139 @ 0x2b83 @ │ │ │ │ - @ instruction: 0x17d310d9 │ │ │ │ - rscsvs r1, fp, fp, asr #21 │ │ │ │ - @ instruction: 0x011a68fb │ │ │ │ - @ instruction: 0x601a68bb │ │ │ │ - ldmdavs fp, {r0, r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ - vstrle d2, [r2, #-1020] @ 0xfffffc04 │ │ │ │ - rscscs r6, pc, #12255232 @ 0xbb0000 │ │ │ │ - @ instruction: 0xf7ff601a │ │ │ │ - ldmvs fp!, {r0, r4, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - bmi 42cbf4 <__bss_end__@@Base+0x385fbc> │ │ │ │ - ldclpl 4, cr4, [r3], {122} @ 0x7a │ │ │ │ - ldmvs fp!, {r1, r3, r4, r9, sl, lr} │ │ │ │ - ldmdavs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ - bmi 36cc04 <__bss_end__@@Base+0x2c5fcc> │ │ │ │ - ldclpl 4, cr4, [r3], {122} @ 0x7a │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ - ldmdavs fp!, {r1, r3, r4, sp, lr} │ │ │ │ - bmi 2acc14 <__bss_end__@@Base+0x205fdc> │ │ │ │ - ldclpl 4, cr4, [r3], {122} @ 0x7a │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r9, sl, lr} │ │ │ │ - svclt 0x0000601a │ │ │ │ - ssatmi r3, #30, r0, lsl #14 │ │ │ │ - svclt 0x0000bd80 │ │ │ │ - @ instruction: 0x0003c8b8 │ │ │ │ - ldrdeq ip, [r3], -r6 │ │ │ │ - ldrdeq ip, [r3], -sl │ │ │ │ - andeq r8, r4, ip, lsr ip │ │ │ │ - andeq r8, r4, ip, lsr #24 │ │ │ │ - andeq r8, r4, ip, lsl ip │ │ │ │ - addlt fp, r6, r0, lsl #11 │ │ │ │ - rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - cmnvs fp, r0, lsl #6 │ │ │ │ - @ instruction: 0xf107e017 │ │ │ │ - @ instruction: 0xf1070308 │ │ │ │ - @ instruction: 0xf107020c │ │ │ │ - ldmdbvs r8!, {r4, r8}^ │ │ │ │ - @ instruction: 0xff5cf7ff │ │ │ │ - ldmvs sl!, {r0, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ - ldmdavs r8!, {r0, r1, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ - blx ff74ec02 <__bss_end__@@Base+0xff6a7fca> │ │ │ │ - ldmdbvs fp!, {r1, r9, sl, lr}^ │ │ │ │ - mulle r1, r3, r2 │ │ │ │ - ldmib lr, {r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - movwcc r6, #6523 @ 0x197b │ │ │ │ - ldmdbvs fp!, {r0, r1, r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ - eorscc pc, r0, #268435460 @ 0x10000004 │ │ │ │ - stclle 2, cr4, [r2, #588]! @ 0x24c │ │ │ │ - svclt 0x0000bf00 │ │ │ │ - ssatmi r3, #30, r8, lsl #14 │ │ │ │ - strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ - svcge 0x0002b08a │ │ │ │ - ldrshtvs r6, [r9], r8 │ │ │ │ - eorsvs r6, fp, sl, ror r0 │ │ │ │ - blcs fffecf24 <__bss_end__@@Base+0xfff462ec> │ │ │ │ - ldmdavs fp!, {r0, r2, fp, ip, lr, pc}^ │ │ │ │ - stmdale r2, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, fp, sp} │ │ │ │ - blcs fffecd30 <__bss_end__@@Base+0xfff460f8> │ │ │ │ - ldmdavs fp!, {r0, r2, r3, r8, fp, ip, lr, pc} │ │ │ │ - ldmdavs fp!, {r0, r8, r9, ip, pc}^ │ │ │ │ - ldmvs fp!, {r8, r9, ip, pc} │ │ │ │ - ldrbtmi r4, [sl], #-2604 @ 0xfffff5d4 │ │ │ │ - stmdami ip!, {r2, r3, r5, r6, r8, sp} │ │ │ │ - @ instruction: 0xf7ff4478 │ │ │ │ - @ instruction: 0xf7f0fde5 │ │ │ │ - @ instruction: 0xf7ffe974 │ │ │ │ - bmi a926e4 <__bss_end__@@Base+0x9ebaac> │ │ │ │ - ldmvs fp!, {r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - ldmdavc fp, {r0, r1, r4, sl, lr} │ │ │ │ - bmi 9eaf60 <__bss_end__@@Base+0x944328> │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - ldmdavc fp, {r0, r1, r4, sl, lr} │ │ │ │ - bmi 96ae6c <__bss_end__@@Base+0x8c4234> │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - ldmdavc fp, {r0, r1, r4, sl, lr} │ │ │ │ - ldmvs fp!, {r0, r1, r3, r4, r5, sp, lr} │ │ │ │ - @ instruction: 0xf1033308 │ │ │ │ - blcs 134d0 │ │ │ │ - @ instruction: 0x4613bfb4 │ │ │ │ - tstne fp, fp, lsl r6 │ │ │ │ - ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ - @ instruction: 0xf1033308 │ │ │ │ - blcs 134e4 │ │ │ │ - @ instruction: 0x4613bfb4 │ │ │ │ - tstne fp, fp, lsl r6 │ │ │ │ - ldmdavs fp!, {r0, r1, r3, r4, r5, r7, r8, sp, lr} │ │ │ │ - @ instruction: 0xf1033308 │ │ │ │ - blcs 134f8 │ │ │ │ - @ instruction: 0x4613bfb4 │ │ │ │ - tstne fp, fp, lsl r6 │ │ │ │ - ldmibvs sl!, {r0, r1, r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ - tsteq fp, r3, lsl r6 │ │ │ │ - ldmibvs fp!, {r1, r3, r4, sl, lr} │ │ │ │ - @ instruction: 0x4613441a │ │ │ │ - ldrmi r0, [r3], #-283 @ 0xfffffee5 │ │ │ │ - ldrmi r6, [r3], #-2426 @ 0xfffff686 │ │ │ │ - ldmdbvs fp!, {r0, r1, r3, r4, r5, r8, sp, lr} │ │ │ │ - eorscc pc, r0, #268435460 @ 0x10000004 │ │ │ │ - stcle 2, cr4, [r8, #-588] @ 0xfffffdb4 │ │ │ │ - ldrbtmi r4, [fp], #-2827 @ 0xfffff4f5 │ │ │ │ - stmdbmi fp, {r0, r2, r4, r5, r6, r9, sp} │ │ │ │ - stmdami fp, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ - @ instruction: 0xf7f04478 │ │ │ │ - ldmdbvs fp!, {r1, r2, r3, r4, r5, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - @ instruction: 0x37204618 │ │ │ │ - stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq ip, r3, sl, ror r5 │ │ │ │ - andeq ip, r3, r0, asr r5 │ │ │ │ - andeq r8, r4, ip, asr ip │ │ │ │ - andeq r8, r4, r0, asr ip │ │ │ │ - andeq r8, r4, r4, asr #24 │ │ │ │ - andeq ip, r3, sl, lsr #13 │ │ │ │ - @ instruction: 0x0003c4b8 │ │ │ │ - strdeq ip, [r3], -r0 │ │ │ │ - addlt fp, r6, r0, lsl #11 │ │ │ │ - rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - @ instruction: 0xf1076039 │ │ │ │ - @ instruction: 0xf107030c │ │ │ │ - @ instruction: 0xf1070210 │ │ │ │ - ldmdavs r8!, {r2, r4, r8} │ │ │ │ - @ instruction: 0xf81cf000 │ │ │ │ - blcs 24550 │ │ │ │ - ldmdavs fp!, {r0, r3, r8, ip, lr, pc} │ │ │ │ - ldrbtmi r4, [sl], #-2569 @ 0xfffff5f7 │ │ │ │ - stmdami r9, {r1, r2, r3, r4, r5, r6, r8, sp} │ │ │ │ + vstr d23, [sp, #796] @ 0x31c │ │ │ │ + @ instruction: 0xf89d7a03 │ │ │ │ + @ instruction: 0xf80c000c │ │ │ │ + @ instruction: 0xf80e0f01 │ │ │ │ + strbmi r0, [r2, #-3841]! @ 0xfffff0ff │ │ │ │ + bmi 547950 <__bss_end__@@Base+0x4a0db0> │ │ │ │ + ldrmi r4, [r3], #-1146 @ 0xfffffb86 │ │ │ │ + strtmi r4, [sl], #-1044 @ 0xfffffbec │ │ │ │ + @ instruction: 0x3104f893 │ │ │ │ + @ instruction: 0x1104f894 │ │ │ │ + @ instruction: 0x0104f892 │ │ │ │ + andeq pc, r8, #-1073741824 @ 0xc0000000 │ │ │ │ + vst4.8 {d3,d5,d7,d9}, [r2], r8 │ │ │ │ + bl f01a4 <__bss_end__@@Base+0x49604> │ │ │ │ + andcc r1, r8, r2, lsl r3 │ │ │ │ + tstne r1, #3072 @ 0xc00 │ │ │ │ + movwne lr, #15107 @ 0x3b03 │ │ │ │ + andsne lr, r0, r3, lsl #22 │ │ │ │ + ldclt 0, cr11, [r0, #-20]! @ 0xffffffec │ │ │ │ + cmncs ip, r7, lsl #20 │ │ │ │ + ldrbtmi r4, [sl], #-2055 @ 0xfffff7f9 │ │ │ │ + strmi lr, [r0, #-2509] @ 0xfffff633 │ │ │ │ @ instruction: 0xf7ff4478 │ │ │ │ - @ instruction: 0xf7f0fd69 │ │ │ │ - ldmdbvs r9!, {r3, r4, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ - ldmvs fp!, {r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ - @ instruction: 0xf7ff6878 │ │ │ │ - strmi pc, [r3], -r0, ror #30 │ │ │ │ - @ instruction: 0x37184618 │ │ │ │ - stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq ip, r3, sl, lsr #9 │ │ │ │ - andeq ip, r3, r8, asr r4 │ │ │ │ - addlt fp, ip, r0, lsl #11 │ │ │ │ - rscsvs sl, r8, r0, lsl #30 │ │ │ │ - ldrhtvs r6, [sl], #-9 │ │ │ │ - ldmvs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ - tstle r1, r0, lsl #22 │ │ │ │ - add r2, r5, r0, lsl #6 │ │ │ │ - ldmdavc fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ - cmple r9, r3, lsr #22 │ │ │ │ - @ instruction: 0xf7f068f8 │ │ │ │ - strmi lr, [r3], -r2, asr #20 │ │ │ │ - bvs feeeb890 <__bss_end__@@Base+0xfee44c58> │ │ │ │ - @ instruction: 0xd12e2b04 │ │ │ │ - movwcc r6, #6395 @ 0x18fb │ │ │ │ - tstpeq r8, r7, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0x46182210 │ │ │ │ - b 1cd0d78 <__bss_end__@@Base+0x1c2a140> │ │ │ │ - ldmibvs fp!, {r3, r4, r5, r9, sp, lr} │ │ │ │ - blcs 30e2c │ │ │ │ - movwcs sp, #1 │ │ │ │ - bvs f0af70 <__bss_end__@@Base+0xe64338> │ │ │ │ - movweq pc, #61443 @ 0xf003 @ │ │ │ │ - ldmibvs fp!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ - ldmibvs fp!, {r1, r3, r4, r8}^ │ │ │ │ - ldmdavs fp!, {r1, r3, r4, sl, lr} │ │ │ │ - bvs eeae44 <__bss_end__@@Base+0xe4420c> │ │ │ │ - @ instruction: 0xf003111b │ │ │ │ - mvnsvs r0, pc, lsl #6 │ │ │ │ - @ instruction: 0x011a69fb │ │ │ │ - ldrmi r6, [sl], #-2555 @ 0xfffff605 │ │ │ │ - andsvs r6, sl, fp, ror r8 │ │ │ │ - andsne r6, fp, #241664 @ 0x3b000 │ │ │ │ - ldmibvs fp!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ - ldmibvs fp!, {r1, r3, r4, r8}^ │ │ │ │ - ldmvs fp!, {r1, r3, r4, sl, lr} │ │ │ │ - movwcs r6, #4122 @ 0x101a │ │ │ │ - bvs fef0af30 <__bss_end__@@Base+0xfee642f8> │ │ │ │ - tstle sp, r7, lsl #22 │ │ │ │ - movwcc r6, #6395 @ 0x18fb │ │ │ │ - tstpeq r4, r7, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0x46182210 │ │ │ │ - b 1050ddc <__bss_end__@@Base+0xfaa1a4> │ │ │ │ - ldmdbvs fp!, {r3, r4, r5, r6, r9, sp, lr}^ │ │ │ │ - blcs 30e90 │ │ │ │ - movwcs sp, #1 │ │ │ │ - bvs 1f0af0c <__bss_end__@@Base+0x1e642d4> │ │ │ │ - ldmvs fp!, {r1, r3, r4, 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0xff74f7ff │ │ │ │ - and r4, r3, r3, lsl #12 │ │ │ │ - movwcc r6, #6907 @ 0x1afb │ │ │ │ - @ instruction: 0xe7d962fb │ │ │ │ - @ instruction: 0x37304618 │ │ │ │ - stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r7, r4, r6, lsr #16 │ │ │ │ - andeq r7, r4, r4, lsl r8 │ │ │ │ - strdeq r7, [r4], -ip │ │ │ │ - addlt fp, r4, r0, lsl #11 │ │ │ │ - rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - rscsvs r6, fp, fp, ror r8 │ │ │ │ - andcs r6, r0, #16449536 @ 0xfb0000 │ │ │ │ - ldmvs fp!, {r1, r3, r4, r7, r8, r9, sp, lr}^ │ │ │ │ - ldmvs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ - @ instruction: 0x4619689b │ │ │ │ - @ instruction: 0xf7f04610 │ │ │ │ - ldmvs fp!, {r5, r6, r8, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0x4618681b │ │ │ │ - stmdb r6!, {r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - ldrcc fp, [r0, -r0, lsl #30] │ │ │ │ - stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - ldrshtlt fp, [r3], #80 @ 0x50 │ │ │ │ - @ instruction: 0xf507af08 │ │ │ │ - @ instruction: 0xf5a373d4 │ │ │ │ - andsvs r7, r8, lr, asr #7 │ │ │ │ - bicsvc pc, r4, #29360128 @ 0x1c00000 │ │ │ │ - bicsvc pc, r0, #683671552 @ 0x28c00000 │ │ │ │ - @ instruction: 0xf5076019 │ │ │ │ - @ instruction: 0xf5a373d4 │ │ │ │ - @ instruction: 0x601a73d2 │ │ │ │ - @ instruction: 0xf8c72301 │ │ │ │ - movwcs r3, #420 @ 0x1a4 │ │ │ │ - asrcc pc, r7, #17 @ │ │ │ │ - ldrbtcc pc, [r8], #-2271 @ 0xfffff721 @ │ │ │ │ + @ instruction: 0xf7effed7 │ │ │ │ + svclt 0x0000ee86 │ │ │ │ + ldrdeq r8, [r4], -r0 │ │ │ │ + andeq r8, r4, r4, lsl #11 │ │ │ │ + andeq r6, r3, sl, lsr #16 │ │ │ │ + andeq r6, r3, r8, asr #27 │ │ │ │ + ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ + stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ + @ instruction: 0x0c0cebad │ │ │ │ + svceq 0x00d8f8cc │ │ │ │ + bmi e24a70 <__bss_end__@@Base+0xd7ded0> │ │ │ │ + blmi e24a90 <__bss_end__@@Base+0xd7def0> │ │ │ │ + addlt r4, r2, sl, ror r4 │ │ │ │ + ldmpl r3, {r2, r9, sl, lr}^ │ │ │ │ + movwls r6, #6171 @ 0x181b │ │ │ │ + movweq pc, #79 @ 0x4f @ │ │ │ │ + @ instruction: 0xf8dfb388 │ │ │ │ + pkhtbmi r9, r8, r0, asr #1 │ │ │ │ + ldrbtmi r4, [r9], #3379 @ 0xd33 │ │ │ │ + stmdavc r3!, {r0, r2, r3, r4, r5, r6, sl, lr} │ │ │ │ + eorle r2, r1, r3, lsr #22 │ │ │ │ + beq 4f37c │ │ │ │ + and r4, r4, r8, asr #12 │ │ │ │ + beq 8f670 <__bss_start@@Base+0x34668> │ │ │ │ + eorseq pc, sl, r5, asr r8 @ │ │ │ │ + @ instruction: 0x4621b158 │ │ │ │ + stmdb lr!, {r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + mvnsle r2, r0, lsl #16 │ │ │ │ + ldrbtmi r4, [fp], #-2858 @ 0xfffff4d6 │ │ │ │ + biceq lr, sl, #3072 @ 0xc00 │ │ │ │ + stccs 8, cr6, [r0], {92} @ 0x5c │ │ │ │ + bmi a47a04 <__bss_end__@@Base+0x9a0e64> │ │ │ │ + ldrbtmi r4, [sl], #-2851 @ 0xfffff4dd │ │ │ │ + ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ + subsmi r9, sl, r1, lsl #22 │ │ │ │ + movweq pc, #79 @ 0x4f @ │ │ │ │ + andlt sp, r2, r9, lsr r1 │ │ │ │ + @ instruction: 0x87f0e8bd │ │ │ │ + @ instruction: 0xf7ef4620 │ │ │ │ + stmdacs r4, {r1, r3, r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r7, {r1, r2, r4, ip, lr, pc} │ │ │ │ + andcs sp, r0, r1 │ │ │ │ + andscs lr, r0, #61079552 @ 0x3a40000 │ │ │ │ + strbtmi r1, [r9], -r0, ror #24 │ │ │ │ + svc 0x00dcf7ef │ │ │ │ + ldmdavc r2, {r9, fp, ip, pc} │ │ │ │ + mvnsle r2, r0, lsl #20 │ │ │ │ + sbclt r1, r3, #33554432 @ 0x2000000 │ │ │ │ + andcs pc, r0, r8, asr #17 │ │ │ │ + andcs pc, r7, #192, 6 │ │ │ │ + eorsvs r2, sl, r1 │ │ │ │ + @ instruction: 0xe7d66033 │ │ │ │ + stclne 2, cr2, [r0], #-64 @ 0xffffffc0 │ │ │ │ + @ instruction: 0xf7ef4669 │ │ │ │ + bls 4f1ec │ │ │ │ + bcs 31310 │ │ │ │ + @ instruction: 0xf000d1e1 │ │ │ │ + andne r0, r3, #-268435456 @ 0xf0000000 │ │ │ │ + smlabtne r3, r0, r3, pc @ │ │ │ │ + andne lr, r2, #2048 @ 0x800 │ │ │ │ + @ instruction: 0xf0006032 │ │ │ │ + bl d3ea0 <__bss_end__@@Base+0x2d300> │ │ │ │ + strmi r1, [sl], #-771 @ 0xfffffcfd │ │ │ │ + eorsvs r2, sl, r1 │ │ │ │ + andcc pc, r0, r8, asr #17 │ │ │ │ + @ instruction: 0xf7f0e7bb │ │ │ │ + svclt 0x0000e842 │ │ │ │ + andeq r4, r4, r8, ror #27 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r6, r3, r2, asr #24 │ │ │ │ + andeq r4, r4, r4, asr #23 │ │ │ │ + muleq r4, lr, fp │ │ │ │ + muleq r4, r6, sp │ │ │ │ + vst3.8 {d27,d29,d31}, [pc :256], r0 │ │ │ │ + bl feb6a514 <__bss_end__@@Base+0xfeac3974> │ │ │ │ + @ instruction: 0xf8cc0c0c │ │ │ │ + @ instruction: 0xf8df0fe0 │ │ │ │ + strmi ip, [r5], -r4, rrx │ │ │ │ + addlt r4, r5, r8, lsl r8 │ │ │ │ + @ instruction: 0x460c44fc │ │ │ │ + bge 7df34 <__bss_start@@Base+0x22f2c> │ │ │ │ + @ instruction: 0xf85c4669 │ │ │ │ + stmdavs r0, {} @ │ │ │ │ + @ instruction: 0xf04f9003 │ │ │ │ + strtmi r0, [r0], -r0 │ │ │ │ + @ instruction: 0xff60f7ff │ │ │ │ + bmi 47f984 <__bss_end__@@Base+0x3d8de4> │ │ │ │ + ldrbtmi r4, [sl], #-2831 @ 0xfffff4f1 │ │ │ │ + ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ + subsmi r9, sl, r3, lsl #22 │ │ │ │ + movweq pc, #79 @ 0x4f @ │ │ │ │ + ldmib sp, {r1, r4, r8, ip, lr, pc}^ │ │ │ │ + strtmi r2, [r8], -r1, lsl #6 │ │ │ │ + andlt r9, r5, r0, lsl #18 │ │ │ │ + ldrhtmi lr, [r0], -sp │ │ │ │ + mcrlt 7, 7, pc, cr8, cr15, {7} @ │ │ │ │ + strtmi r4, [r3], -r8, lsl #20 │ │ │ │ + cmncs lr, r8, lsl #16 │ │ │ │ + ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ + mrc2 7, 0, pc, cr0, cr15, {7} │ │ │ │ + ldc 7, cr15, [lr, #956]! @ 0x3bc │ │ │ │ + svc 0x00faf7ef │ │ │ │ + ldrdeq r4, [r4], -ip │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + @ instruction: 0x00044cba │ │ │ │ + andeq r6, r3, r4, ror #13 │ │ │ │ + andeq r6, r3, sl, lsr ip │ │ │ │ + svcmi 0x00f0e92d │ │ │ │ + stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ + @ instruction: 0x0c0cebad │ │ │ │ + cdpeq 8, 2, cr15, cr8, cr12, {6} │ │ │ │ + ldmmi r0, {r0, r7, r9, sl, lr}^ │ │ │ │ + ldmibmi r0, {r0, r1, r2, r3, r9, sl, lr}^ │ │ │ │ + blmi ff424590 <__bss_end__@@Base+0xff37d9f0> │ │ │ │ + ldrmi fp, [r0], sp, ror #1 │ │ │ │ vst3.16 {d20-d22}, [pc :256], fp │ │ │ │ - vqsub.s8 d20, d16, d10 │ │ │ │ - @ instruction: 0xf8df3133 │ │ │ │ - ldrbtmi r0, [r8], #-1136 @ 0xfffffb90 │ │ │ │ - stc2l 0, cr15, [r0, #-0] │ │ │ │ - orrseq pc, ip, r7, asr #17 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - bicsvs r2, sl, r0, lsl #4 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - andsvs r2, sl, #0, 4 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - sbcsvs r2, sl, #0, 4 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - tstvs sl, #0, 4 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - rscscc pc, pc, #79 @ 0x4f │ │ │ │ - @ instruction: 0xf8df635a │ │ │ │ - ldrbtmi r3, [fp], #-1084 @ 0xfffffbc4 │ │ │ │ - @ instruction: 0xf7f04618 │ │ │ │ - @ instruction: 0xf8c7e848 │ │ │ │ - @ instruction: 0xf8d70198 │ │ │ │ - @ instruction: 0xf7f00198 │ │ │ │ - strmi lr, [r2], -r8, asr #17 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d7601a │ │ │ │ - ldmdavs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - tstle r7, r0, lsl #22 │ │ │ │ - @ instruction: 0x1198f8d7 │ │ │ │ - ldrcc pc, [r0], #-2271 @ 0xfffff721 │ │ │ │ - @ instruction: 0x4618447b │ │ │ │ - ldc2 7, cr15, [r4], {255} @ 0xff │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d3681b │ │ │ │ - @ instruction: 0xf8c73084 │ │ │ │ - @ instruction: 0xf8d73194 │ │ │ │ - blcs 1f638 │ │ │ │ - @ instruction: 0xf8d7d043 │ │ │ │ - ldmdavs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - ldrdcs pc, [ip], r3 │ │ │ │ - @ instruction: 0x3194f8d7 │ │ │ │ - blx 5b4fe <__bss_start@@Base+0x45e> │ │ │ │ - ldrmi pc, [r3], #-771 @ 0xfffffcfd │ │ │ │ - @ instruction: 0xf8c76a9b │ │ │ │ - @ instruction: 0xf8d73190 │ │ │ │ - ldmdavs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - ldrdcs pc, [ip], r3 │ │ │ │ - @ instruction: 0x3194f8d7 │ │ │ │ - blx 5b51a <__bss_start@@Base+0x47a> │ │ │ │ - ldrmi pc, [r3], #-771 @ 0xfffffcfd │ │ │ │ - @ instruction: 0xf8d76b1a │ │ │ │ - @ instruction: 0x605a319c │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d3681b │ │ │ │ - @ instruction: 0xf8d7208c │ │ │ │ - @ instruction: 0x21503194 │ │ │ │ - vqrdmulh.s d15, d3, d1 │ │ │ │ - bvs 16e4048 <__bss_end__@@Base+0x163d410> │ │ │ │ - orrcc pc, ip, r7, asr #17 │ │ │ │ - bicsvc pc, r4, #29360128 @ 0x1c00000 │ │ │ │ - bicsvc pc, r2, #683671552 @ 0x28c00000 │ │ │ │ - sbcsvc pc, r4, #29360128 @ 0x1c00000 │ │ │ │ - sbcsvc pc, r0, #679477248 @ 0x28800000 │ │ │ │ - rsbeq pc, ip, r7, lsl #2 │ │ │ │ - ldmdavs r2, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ - ldrbtmi r4, [r9], #-2529 @ 0xfffff61f │ │ │ │ - b ffc50fe0 <__bss_end__@@Base+0xffbaa3a8> │ │ │ │ - msreq SPSR_fs, #-1073741823 @ 0xc0000001 │ │ │ │ - asrcc pc, r7, #17 @ │ │ │ │ - ldrdcc pc, [r0, r7]! │ │ │ │ - cmple r3, r0, lsl #22 │ │ │ │ - movwcs lr, #10 │ │ │ │ - ldrbtmi r4, [sl], #-2779 @ 0xfffff525 │ │ │ │ - cmppcc r5, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ - ldrbtmi r4, [r8], #-2266 @ 0xfffff726 │ │ │ │ - blx ffcd1042 <__bss_end__@@Base+0xffc2a40a> │ │ │ │ - svc 0x0080f7ef │ │ │ │ - @ instruction: 0xf8c72308 │ │ │ │ - @ instruction: 0xf8d73138 │ │ │ │ - ldmdavs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - ldrdcs pc, [ip], r3 │ │ │ │ - @ instruction: 0x3194f8d7 │ │ │ │ - blx 5b5a2 <__bss_start@@Base+0x502> │ │ │ │ - ldrmi pc, [r3], #-771 @ 0xfffffcfd │ │ │ │ - @ instruction: 0x4613691a │ │ │ │ - ldrmi r0, [r3], #-91 @ 0xffffffa5 │ │ │ │ - blcs 1a3d8 │ │ │ │ - @ instruction: 0x4613bfb4 │ │ │ │ - addsne r4, fp, fp, lsl r6 │ │ │ │ - smlalbtcc pc, r8, r7, r8 @ │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d3681b │ │ │ │ - @ instruction: 0xf8d7208c │ │ │ │ - @ instruction: 0x21503194 │ │ │ │ - vqrdmulh.s d15, d3, d1 │ │ │ │ - ldmvs sl, {r0, r1, r4, sl, lr}^ │ │ │ │ - subseq r4, fp, r3, lsl r6 │ │ │ │ - ldclne 4, cr4, [sl], {19} │ │ │ │ - svclt 0x00b42b00 │ │ │ │ - @ instruction: 0x461b4613 │ │ │ │ - @ instruction: 0xf8c7109b │ │ │ │ - movwcs r3, #324 @ 0x144 │ │ │ │ - teqpcc ip, r7, asr #17 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0xf8c72300 │ │ │ │ - eors r3, r4, r0, asr #2 │ │ │ │ - orrsvc pc, ip, #29360128 @ 0x1c00000 │ │ │ │ + stmdapl r1, {r1, r3, r4, r7, r9, lr}^ │ │ │ │ + stmdavs r9, {r0, r2, r3, r6, r7, fp, lr} │ │ │ │ + @ instruction: 0xf04f916b │ │ │ │ + vrhadd.s8 d16, d0, d0 │ │ │ │ + ldrbtmi r3, [r8], #-307 @ 0xfffffecd │ │ │ │ + blx 1ecf3d2 <__bss_end__@@Base+0x1e28832> │ │ │ │ + strmi r2, [r4], -r0, lsl #6 │ │ │ │ + movwcc lr, #31168 @ 0x79c0 │ │ │ │ + movwcc lr, #47552 @ 0xb9c0 │ │ │ │ + mvnscc pc, #79 @ 0x4f │ │ │ │ + stmiami r5, {r0, r1, r6, r8, r9, sp, lr}^ │ │ │ │ + @ instruction: 0xf7ef4478 │ │ │ │ + @ instruction: 0x4605edde │ │ │ │ + cdp 7, 6, cr15, cr2, cr15, {7} │ │ │ │ + stmdacs r0, {r5, sp, lr} │ │ │ │ + cmpphi r3, r0 @ p-variant is OBSOLETE │ │ │ │ + ldrdpl pc, [r4], r0 │ │ │ │ + @ instruction: 0xf8d02250 │ │ │ │ + cdpge 0, 5, cr3, cr2, cr12, {4} │ │ │ │ + ldrtmi r2, [r0], -r1, lsl #2 │ │ │ │ + vqdmulh.s d15, d5, d2 │ │ │ │ + bl f7c30 <__bss_end__@@Base+0x51090> │ │ │ │ + blmi fee9641c <__bss_end__@@Base+0xfedef87c> │ │ │ │ + ldrbtmi r2, [fp], #-611 @ 0xfffffd9d │ │ │ │ + ldrsbtpl pc, [r0], -ip @ │ │ │ │ + ldrdlt pc, [r8], -ip @ │ │ │ │ + ldrdge pc, [r4], -ip @ │ │ │ │ + stmib sp, {r0, r2, r5, r6, sp, lr}^ │ │ │ │ + svcge 0x00277800 │ │ │ │ + ldmda lr!, {r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ tstcs r0, r8, asr #4 │ │ │ │ - @ instruction: 0xf7ef4618 │ │ │ │ - @ instruction: 0xf507efe2 │ │ │ │ - @ instruction: 0xf103739c │ │ │ │ - @ instruction: 0xf507000c │ │ │ │ - @ instruction: 0xf103739c │ │ │ │ - @ instruction: 0xf5070208 │ │ │ │ - ldcne 3, cr7, [r9, #-624] @ 0xfffffd90 │ │ │ │ - orrsvc pc, ip, #29360128 @ 0x1c00000 │ │ │ │ - movwls r3, #784 @ 0x310 │ │ │ │ - @ instruction: 0xf8d74603 │ │ │ │ - @ instruction: 0xf7f001a0 │ │ │ │ - @ instruction: 0xf8c7ea90 │ │ │ │ - @ instruction: 0xf8d70188 │ │ │ │ - @ instruction: 0xf0033188 │ │ │ │ - blcs 13d08 │ │ │ │ - @ instruction: 0xf8d7d005 │ │ │ │ - @ instruction: 0xf0433138 │ │ │ │ - @ instruction: 0xf8c70301 │ │ │ │ - @ instruction: 0xf8d73138 │ │ │ │ - @ instruction: 0xf0033188 │ │ │ │ - blcs 13d44 │ │ │ │ - @ instruction: 0xf8d7d005 │ │ │ │ - @ instruction: 0xf0433138 │ │ │ │ - @ instruction: 0xf8c70302 │ │ │ │ - @ instruction: 0xf5073138 │ │ │ │ - @ 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d15, d3, d1 │ │ │ │ - ldmvs r9, {r0, r1, r4, sl, lr} │ │ │ │ - teqpmi ip, r7 @ @ p-variant is OBSOLETE │ │ │ │ - ldrdpl pc, [r0, #-135] @ 0xffffff79 │ │ │ │ - ldrdcc pc, [r4, #-135] @ 0xffffff79 │ │ │ │ - @ instruction: 0xf8d7461e │ │ │ │ - eorsvs r3, fp, r8, asr #2 │ │ │ │ - ldrdcc pc, [r4, r7] │ │ │ │ - sbcseq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ - movwls r9, #25095 @ 0x6207 │ │ │ │ - @ instruction: 0x3190f8d7 │ │ │ │ - movwcs r9, #4869 @ 0x1305 │ │ │ │ - @ instruction: 0xf8d79304 │ │ │ │ - movwls r3, #12684 @ 0x318c │ │ │ │ - movwls r2, #8960 @ 0x2300 │ │ │ │ - movwls r6, #6203 @ 0x183b │ │ │ │ - strtmi r9, [fp], -r0, lsl #12 │ │ │ │ - @ instruction: 0xf7ef4622 │ │ │ │ - strmi lr, [r2], -r0, lsl #31 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d7609a │ │ │ │ - ldmdavs r8, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf507689c │ │ │ │ - @ instruction: 0xf5a373d4 │ │ │ │ - @ instruction: 0xf50773ce │ │ │ │ - @ instruction: 0xf5a272d4 │ │ │ │ - @ instruction: 0xf50772ce │ │ │ │ - @ instruction: 0x9103719c │ │ │ │ - mrsls r2, (UNDEF: 18) │ │ │ │ - mrsls r2, (UNDEF: 17) │ │ │ │ - mrsls r2, (UNDEF: 16) │ │ │ │ - ldmdavs r2, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ - @ instruction: 0xf7f04621 │ │ │ │ - movwcs lr, #14684 @ 0x395c │ │ │ │ - tstpcc r4, r7, asr #17 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0xf8c72301 │ │ │ │ - movwcs r3, #4376 @ 0x1118 │ │ │ │ - tstpcc ip, r7, asr #17 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d76818 │ │ │ │ - ldmvs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - addvc pc, sl, #29360128 @ 0x1c00000 │ │ │ │ - @ instruction: 0xf7f04619 │ │ │ │ - @ instruction: 0xf8d7e9cc │ │ │ │ - ldmdavs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - ldrmi r2, [r8], -r2, lsl #3 │ │ │ │ - cdp 7, 7, cr15, cr4, cr15, {7} │ │ │ │ - orreq pc, r0, r7, asr #17 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d76818 │ │ │ │ - ldmvs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - ldrdcs pc, [r0, r7] │ │ │ │ - @ instruction: 0xf7f04619 │ │ │ │ - @ instruction: 0xf8d7e8f6 │ │ │ │ - ldmdavs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - ldmdbmi r0, {r9, sp}^ │ │ │ │ - @ instruction: 0x46184479 │ │ │ │ - stmdb ip, {r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - @ instruction: 0xf8d74602 │ │ │ │ - @ instruction: 0x611a319c │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - andcs r6, r0, #1769472 @ 0x1b0000 │ │ │ │ - ldrbtmi r4, [r9], #-2378 @ 0xfffff6b6 │ │ │ │ - @ instruction: 0xf7f04618 │ │ │ │ - strmi lr, [r2], -r0, lsl #18 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d7619a │ │ │ │ - ldmibvs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - sbcscc pc, r0, r7, asr #17 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - andcs r6, r0, #1769472 @ 0x1b0000 │ │ │ │ - ldrbtmi r4, [r9], #-2370 @ 0xfffff6be │ │ │ │ - @ instruction: 0xf7f04618 │ │ │ │ - strmi lr, [r2], -lr, ror #17 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ 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instruction: 0xf8d7208c │ │ │ │ - ldrbcs r3, [r0], #-404 @ 0xfffffe6c │ │ │ │ - vqrdmulh.s d15, d3, d4 │ │ │ │ - blvs fe6e4378 <__bss_end__@@Base+0xfe63d740> │ │ │ │ - @ instruction: 0xf7f0461a │ │ │ │ - @ instruction: 0xf507e800 │ │ │ │ - @ instruction: 0xf5a373d4 │ │ │ │ - andcs r7, r1, #204, 6 @ 0x30000003 │ │ │ │ - @ instruction: 0xf8d7619a │ │ │ │ - ldmdavs r8, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d3681b │ │ │ │ - @ instruction: 0xf8d7208c │ │ │ │ - @ instruction: 0x21503194 │ │ │ │ - vqrdmulh.s d15, d3, d1 │ │ │ │ - ldmvs r9, {r0, r1, r4, sl, lr} │ │ │ │ - tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ - @ instruction: 0xf7ef2240 │ │ │ │ - strmi lr, [r2], -ip, ror #31 │ │ │ │ - @ instruction: 0x319cf8d7 │ │ │ │ - @ instruction: 0xf8d760da │ │ │ │ - @ instruction: 0xf7ff019c │ │ │ │ - @ instruction: 0xf8d7fc2f │ │ │ │ - ldmdavs fp, {r2, r3, r4, r7, r8, ip, sp} │ │ │ │ - @ instruction: 0xf7ef4618 │ │ │ │ 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+ strmi r0, [r3], -r2, lsl #15 │ │ │ │ + svclt 0x00189d08 │ │ │ │ + vtst.8 d22, d2, d26 │ │ │ │ + @ instruction: 0xf04f0e12 │ │ │ │ + svclt 0x001c0801 │ │ │ │ + andeq pc, r1, #66 @ 0x42 │ │ │ │ + @ instruction: 0xf010603a │ │ │ │ + bge 61709c <__bss_end__@@Base+0x5704fc> │ │ │ │ + ldmdavs fp!, {r1, r2, r3, r4, r8, r9, sl, fp, ip, sp, pc} │ │ │ │ + movweq pc, #8259 @ 0x2043 @ │ │ │ │ + ldmib r4, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ + @ instruction: 0x93250300 │ │ │ │ + rsbshi pc, r0, sp, asr #17 │ │ │ │ + ldrdcc pc, [ip], r0 │ │ │ │ + @ instruction: 0x0c05eb03 │ │ │ │ + @ instruction: 0xf8dc68bb │ │ │ │ + @ instruction: 0xf8dc1008 │ │ │ │ + stmib sp, {r3, r4, r5, lr, pc}^ │ │ │ │ + @ instruction: 0xf8cdbe05 │ │ │ │ + ldmdbvs sp!, {r2, r3, sp, pc} │ │ │ │ + ldmvs sp!, {r0, r8, sl, ip, pc}^ │ │ │ │ + andls r9, r7, #0, 10 │ │ │ │ + andshi pc, r0, sp, asr #17 │ │ │ │ + ldmdavs sl!, {r1, r9, sl, ip, pc}^ │ │ │ │ + rsbgt pc, r4, sp, asr #17 │ │ │ │ + stcl 7, cr15, [r8, #956]! @ 0x3bc │ │ │ │ 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│ │ │ + subsls r4, r0, r9, ror r4 │ │ │ │ + ldrbtmi r6, [pc], #-2080 @ 1351c │ │ │ │ + svc 0x008af7ef │ │ │ │ + stmiavs r1!, {r1, r8, r9, sp} │ │ │ │ + cmnvs r0, r0, asr sl │ │ │ │ + stmdavs r0!, {r0, r4, r6, ip, pc} │ │ │ │ + cdp 7, 7, cr15, cr10, cr15, {7} │ │ │ │ + stmdavs r0!, {r0, r5, r7, fp, sp, lr} │ │ │ │ + andeq pc, sp, #72, 4 @ 0x80000004 │ │ │ │ + eoreq pc, r2, #192, 4 │ │ │ │ + cdp 7, 14, cr15, cr14, cr15, {7} │ │ │ │ + stmdavs r0!, {r0, r5, r7, fp, sp, lr} │ │ │ │ + cdp 7, 11, cr15, cr8, cr15, {7} │ │ │ │ + stcls 8, cr6, [r8, #-128] @ 0xffffff80 │ │ │ │ + @ instruction: 0xf8d068a1 │ │ │ │ + strtmi r3, [fp], #-140 @ 0xffffff74 │ │ │ │ + @ instruction: 0xf7ef6b9a │ │ │ │ + stmdavs r0!, {r3, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + subcs sl, r0, #58368 @ 0xe400 │ │ │ │ + rscshi pc, ip, sp, asr #17 │ │ │ │ + ldrdne pc, [ip], r0 │ │ │ │ + vshl.s8 d20, d25, d15 │ │ │ │ + vshl.s64 q8, , #15 │ │ │ │ + stmvs r9, {r4, r5, r6, r7, r8, sl} │ │ │ │ + cdp 7, 11, cr15, cr14, cr15, {7} │ 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r2, r9, ip, sp, lr, pc} │ │ │ │ + bcs 10fdf8 <__bss_end__@@Base+0x69258> │ │ │ │ + stmdbeq r1, {r6, r7, r8, ip, sp, lr, pc} │ │ │ │ + stceq 0, cr15, [r1], {79} @ 0x4f │ │ │ │ + blvs 4f0c0 │ │ │ │ + blgt 1116f0 <__bss_end__@@Base+0x6ab50> │ │ │ │ + andeq lr, r8, r9, lsl #22 │ │ │ │ + beq 44ee10 <__bss_end__@@Base+0x3a8270> │ │ │ │ + blvc ff20f0d8 <__bss_end__@@Base+0xff168538> │ │ │ │ + blvc 1ceed8 <__bss_end__@@Base+0x128338> │ │ │ │ + blvc ff20f1f0 <__bss_end__@@Base+0xff168650> │ │ │ │ + bvc 28ed38 <__bss_end__@@Base+0x1e8198> │ │ │ │ + mlagt r4, sp, r8, pc @ │ │ │ │ + svcgt 0x0001f808 │ │ │ │ + svcgt 0x0001f801 │ │ │ │ + ldrdle r4, [fp, #80]! @ 0x50 │ │ │ │ + vtst.8 d20, d1, d30 │ │ │ │ + blvs fe8626dc <__bss_end__@@Base+0xfe7bbb3c> │ │ │ │ + strmi r4, [r6], #1144 @ 0x478 │ │ │ │ + ldrmi r4, [r0], #-1027 @ 0xfffffbfd │ │ │ │ + @ instruction: 0xf89e4561 │ │ │ │ + @ instruction: 0xf893b004 │ │ │ │ + @ instruction: 0xf8909004 │ │ │ │ + ldcle 0, cr10, [fp], #-16 │ │ │ │ + stmdaeq ip!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ + movwcs lr, #47883 @ 0xbb0b │ │ │ │ + ldrdeq lr, [r0, -r4] │ │ │ │ + @ instruction: 0xf8a84642 │ │ │ │ + bl 25f658 <__bss_end__@@Base+0x1b8ab8> │ │ │ │ + @ instruction: 0xf8a82309 │ │ │ │ + bl 29f668 <__bss_end__@@Base+0x1f8ac8> │ │ │ │ + @ instruction: 0xf8a8230a │ │ │ │ + @ instruction: 0xf7ef3008 │ │ │ │ + stmdacs r0, {r2, r4, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + blvs fe907730 <__bss_end__@@Base+0xfe860b90> │ │ │ │ + ldrdeq pc, [r0], -r8 │ │ │ │ + adcsmi r1, r3, #23040 @ 0x5a00 │ │ │ │ + orreq lr, r3, r4, lsl #22 │ │ │ │ + @ instruction: 0x63a263c8 │ │ │ │ + vand d29, d1, d23 │ │ │ │ + @ instruction: 0x46163331 │ │ │ │ + @ instruction: 0xd181429a │ │ │ │ + @ instruction: 0xf7ef6820 │ │ │ │ + bmi 94efec <__bss_end__@@Base+0x8a844c> │ │ │ │ + ldrbtmi r4, [sl], #-2841 @ 0xfffff4e7 │ │ │ │ + ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ + subsmi r9, sl, fp, ror #22 │ │ │ │ + movweq pc, #79 @ 0x4f @ │ │ │ │ + @ instruction: 0x4620d116 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mrrcne 11, 9, r6, r9, cr11 │ │ │ │ - orrsvs r6, r1, #16384000 @ 0xfa0000 │ │ │ │ - @ instruction: 0x37204618 │ │ │ │ - stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq fp, r3, r8, lsr #30 │ │ │ │ - andeq fp, r3, r8, asr #27 │ │ │ │ - andeq fp, r3, r4, asr #27 │ │ │ │ - muleq r3, r8, sp │ │ │ │ - andeq fp, r3, r4, asr #29 │ │ │ │ - andeq fp, r3, ip, lsr #26 │ │ │ │ - addlt fp, r3, r0, lsl #9 │ │ │ │ - rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - @ instruction: 0xf8d3681b │ │ │ │ - ldmdavs fp!, {r2, r3, r7, sp}^ │ │ │ │ - @ instruction: 0xf8d3681b │ │ │ │ - ldrmi r3, [r9], -r4, lsl #1 │ │ │ │ - blx 5c222 <__bss_start@@Base+0x1182> │ │ │ │ - ldrmi pc, [r3], #-771 @ 0xfffffcfd │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r6, r7, fp, sp, lr} │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ - @ instruction: 0xf8d3681b │ │ │ │ - ldmdavs fp!, {r2, r3, r7, sp}^ │ │ │ │ - @ instruction: 0xf8d3681b │ │ │ │ - ldrmi r3, [r9], -r4, lsl #1 │ │ │ │ - blx 5c242 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r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, pc, asr #3 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, fp, ror #4 │ │ │ │ - andeq r0, r0, r5, lsl #1 │ │ │ │ - msreq CPSR_s, #-1073741823 @ 0xc0000001 │ │ │ │ - @ instruction: 0xf7ef4618 │ │ │ │ - rscs lr, r3, lr, lsr #25 │ │ │ │ - msreq CPSR_s, #-1073741823 @ 0xc0000001 │ │ │ │ - addcc pc, r8, r7, asr #17 │ │ │ │ - andcs r6, r6, #3866624 @ 0x3b0000 │ │ │ │ - @ instruction: 0xf107601a │ │ │ │ - @ instruction: 0xf1070220 │ │ │ │ - @ instruction: 0xf107010c │ │ │ │ - movwls r0, #792 @ 0x318 │ │ │ │ - andcs r4, r9, #19922944 @ 0x1300000 │ │ │ │ - ldrdeq pc, [r8], r7 │ │ │ │ - stc 7, cr15, [r4], #956 @ 0x3bc │ │ │ │ - addeq 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│ │ │ │ + mvnvc lr, #143360 @ 0x23000 │ │ │ │ + blmi 2ebad8 <__bss_end__@@Base+0x244f38> │ │ │ │ + ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ + subsmi r9, sl, sp, lsl #22 │ │ │ │ + movweq pc, #79 @ 0x4f @ │ │ │ │ + andlt sp, lr, sl, lsl #2 │ │ │ │ + bls 302fe0 <__bss_end__@@Base+0x25c440> │ │ │ │ + blle ff55e224 <__bss_end__@@Base+0xff4b7684> │ │ │ │ + addmi r6, sl, #659456 @ 0xa1000 │ │ │ │ + stmib r4, {r1, r4, r6, r7, r9, fp, ip, lr, pc}^ │ │ │ │ + ldrb r3, [r0, fp, lsl #4] │ │ │ │ + stc 7, cr15, [r0], #956 @ 0x3bc │ │ │ │ + andeq r4, r4, sl, ror #12 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r4, r4, r8, lsl #12 │ │ │ │ + ldrbmi r6, [r0, -r0, asr #20]! │ │ │ │ + ldrbmi r6, [r0, -r0, lsl #21]! │ │ │ │ + ldrbmi r6, [r0, -r0, asr #19]! │ │ │ │ + ldrbmi r6, [r0, -r0, lsl #20]! │ │ │ │ + mvnsmi lr, sp, lsr #18 │ │ │ │ + stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ + @ instruction: 0x0c0cebad │ │ │ │ + svceq 0x00d8f8cc │ │ │ │ + stcls 0, cr11, [fp, #-528] @ 0xfffffdf0 │ │ │ │ + blle 79ee68 <__bss_end__@@Base+0x6f82c8> │ │ │ │ + blvs fe0e52e4 <__bss_end__@@Base+0xfe03e744> │ │ │ │ + adcmi r4, fp, #4, 12 @ 0x400000 │ │ │ │ + blvs 110aed8 <__bss_end__@@Base+0x1064338> │ │ │ │ + ldrmi r4, [r7], -r8, lsl #13 │ │ │ │ + andle r4, r7, fp, lsr #5 │ │ │ │ + bl 2c794 │ │ │ │ + stmiavs r1, {r0, r2, r7, r8, sl}^ │ │ │ │ + blvs ffaada88 <__bss_end__@@Base+0xffa06ee8> │ │ │ │ + bl fe251a48 <__bss_end__@@Base+0xfe1aaea8> │ │ │ │ + strbmi r9, [r3], -sl, lsl #18 │ │ │ │ + stmib sp, {r1, r5, r6, r7, fp, sp, lr}^ │ │ │ │ + strls r6, [r0, -r1, lsl #2] │ │ │ │ + stmdavs r0!, {r0, r5, r7, fp, sp, lr} │ │ │ │ + bl 1351a5c <__bss_end__@@Base+0x12aaebc> │ │ │ │ + pop {r2, ip, sp, pc} │ │ │ │ + bmi 174268 <__bss_end__@@Base+0xcd6c8> │ │ │ │ + stmdami r5, {r0, r1, r3, r5, r9, sl, lr} │ │ │ │ + @ instruction: 0x41b3f240 │ │ │ │ + ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ + blx 1c51ab4 <__bss_end__@@Base+0x1baaf14> │ │ │ │ + b 7d1a78 <__bss_end__@@Base+0x72aed8> │ │ │ │ + andeq r6, r3, ip, asr #11 │ │ │ │ + strdeq r6, [r3], -sl │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ - ble 21e600 <__bss_end__@@Base+0x1779c8> │ │ │ │ + ble 21e6d8 <__bss_end__@@Base+0x177b38> │ │ │ │ ldrbtmi r4, [fp], #-2859 @ 0xfffff4d5 │ │ │ │ stmdbmi fp!, {r0, r2, r6, r9, sp} │ │ │ │ stmdami fp!, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf7ef4478 │ │ │ │ - ldmdavs fp!, {r1, r4, r5, r6, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + ldmdavs fp!, {r5, r6, r7, r9, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0x4618331c │ │ │ │ - stcl 7, cr15, [r4], {239} @ 0xef │ │ │ │ + ldc 7, cr15, [r4], #-956 @ 0xfffffc44 │ │ │ │ cmnvs fp, r3, lsl #12 │ │ │ │ - blcs 2e010 │ │ │ │ + blcs 2e0e8 │ │ │ │ ldmdavs fp!, {r1, r2, r8, ip, lr, pc}^ │ │ │ │ ldrbtmi r4, [sl], #-2596 @ 0xfffff5dc │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ - mrc2 7, 7, pc, cr10, cr14, {7} │ │ │ │ + blx 11d1b08 <__bss_end__@@Base+0x112af68> │ │ │ │ ldrbtmi r4, [fp], #-2850 @ 0xfffff4de │ │ │ │ ldmdbvs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ ldrshvs r6, [sl], #138 @ 0x8a │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr} │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r8, sp, lr}^ │ │ │ │ cmpvs sl, sl, lsr r8 │ │ │ │ @ instruction: 0xf646697a │ │ │ │ @ instruction: 0xf6c303b1 │ │ │ │ @ instruction: 0x619323de │ │ │ │ ldrbtmi r4, [fp], #-2838 @ 0xfffff4ea │ │ │ │ - blcs 2dadc │ │ │ │ - blmi 587a84 <__bss_end__@@Base+0x4e0e4c> │ │ │ │ + blcs 2dbb4 │ │ │ │ + blmi 587b5c <__bss_end__@@Base+0x4e0fbc> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ andsvs r6, sl, sl, ror r9 │ │ │ │ ldrbtmi r4, [fp], #-2835 @ 0xfffff4ed │ │ │ │ andsvs r6, sl, sl, ror r9 │ │ │ │ - blcs 2dc74 │ │ │ │ + blcs 2dd4c │ │ │ │ ldmdbvs fp!, {r2, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ andseq pc, ip, r3, lsl #2 │ │ │ │ @ instruction: 0xf5b3687b │ │ │ │ svclt 0x00a87f7a │ │ │ │ cmnpvc sl, #1325400064 @ p-variant is OBSOLETE @ 0x4f000000 │ │ │ │ tstcs r0, sl, lsl r6 │ │ │ │ - b ffcd1a60 <__bss_end__@@Base+0xffc2ae28> │ │ │ │ + b 1851b38 <__bss_end__@@Base+0x17aaf98> │ │ │ │ tstcc ip, #2015232 @ 0x1ec000 │ │ │ │ @ instruction: 0x37184618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq fp, r3, r2, lsr ip │ │ │ │ - andeq fp, r3, r0, lsr #19 │ │ │ │ - andeq fp, r3, r8, lsr #19 │ │ │ │ - muleq r3, r6, r9 │ │ │ │ - andeq r7, r4, lr, lsl #31 │ │ │ │ - andeq r7, r4, sl, asr pc │ │ │ │ - andeq r7, r4, r0, asr pc │ │ │ │ - andeq r7, r4, r6, asr #30 │ │ │ │ + andeq fp, r3, sl, asr #22 │ │ │ │ + @ instruction: 0x0003b8b0 │ │ │ │ + andeq fp, r3, r0, asr #17 │ │ │ │ + andeq fp, r3, lr, lsr #17 │ │ │ │ + andeq r7, r4, lr, lsl lr │ │ │ │ + andeq r7, r4, sl, ror #27 │ │ │ │ + andeq r7, r4, r0, ror #27 │ │ │ │ + ldrdeq r7, [r4], -r6 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blcc 72dcc8 <__bss_end__@@Base+0x687090> │ │ │ │ + blcc 72dda0 <__bss_end__@@Base+0x687200> │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ @ instruction: 0xf646699a │ │ │ │ @ instruction: 0xf6c303b1 │ │ │ │ addsmi r2, sl, #2013265923 @ 0x78000003 │ │ │ │ movwcs sp, #9 │ │ │ │ ldrbtmi r4, [sl], #-2566 @ 0xfffff5fa │ │ │ │ stmdami r6, {r0, r1, r2, r3, r4, r6, r8, sp} │ │ │ │ - @ instruction: 0xf7fe4478 │ │ │ │ - @ instruction: 0xf7effe95 │ │ │ │ - ldmvs fp!, {r2, r5, r9, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ff4478 │ │ │ │ + @ instruction: 0xf7eff9e1 │ │ │ │ + ldmvs fp!, {r4, r7, r8, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq fp, r3, lr, ror #17 │ │ │ │ - @ instruction: 0x0003b8b0 │ │ │ │ + andeq fp, r3, r6, lsl #16 │ │ │ │ + andeq fp, r3, r0, asr #15 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r2, lsl #30 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ ldrsbtvs pc, [r8], #247 @ 0xf7 @ │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldrmi r9, [r3], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [sl], #-2564 @ 0xfffff5fc │ │ │ │ stmdami r4, {r0, r3, r5, r6, r8, sp} │ │ │ │ - @ instruction: 0xf7fe4478 │ │ │ │ - @ instruction: 0xf7effe75 │ │ │ │ - svclt 0x0000ea04 │ │ │ │ - strdeq fp, [r3], -r2 │ │ │ │ - andeq fp, r3, r0, ror r8 │ │ │ │ + @ instruction: 0xf7ff4478 │ │ │ │ + @ instruction: 0xf7eff9c1 │ │ │ │ + svclt 0x0000e970 │ │ │ │ + andeq fp, r3, sl, lsl #16 │ │ │ │ + andeq fp, r3, r0, lsl #15 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blcs 2dd44 │ │ │ │ + blcs 2de1c │ │ │ │ ldmdavs r8!, {r1, r2, r3, r6, ip, lr, pc}^ │ │ │ │ @ instruction: 0xffb8f7ff │ │ │ │ ldmvs fp!, {r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ - blcs 2e0d4 │ │ │ │ + blcs 2e1ac │ │ │ │ ldmvs fp!, {r0, r3, ip, lr, pc}^ │ │ │ │ adcsvs r6, fp, fp, asr r9 │ │ │ │ - bmi 8edf60 <__bss_end__@@Base+0x847328> │ │ │ │ + bmi 8ee038 <__bss_end__@@Base+0x847498> │ │ │ │ cmpvs sl, sl, ror r4 │ │ │ │ ldmdavs r8!, {r0, r1, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r3, r4, r7, r8, r9, sl, lr}^ │ │ │ │ - blcs 2ddf0 │ │ │ │ + blcs 2dec8 │ │ │ │ ldmvs fp!, {r0, r1, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf5b3689b │ │ │ │ svclt 0x00a87f7a │ │ │ │ cmnpvc sl, #1325400064 @ p-variant is OBSOLETE @ 0x4f000000 │ │ │ │ tstcs r0, sl, lsl r6 │ │ │ │ @ instruction: 0xf7ef6878 │ │ │ │ - blmi 68e578 <__bss_end__@@Base+0x5e7940> │ │ │ │ + blmi 68e408 <__bss_end__@@Base+0x5e7868> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ addsmi r6, sl, #16384000 @ 0xfa0000 │ │ │ │ ldmvs fp!, {r0, r1, r2, r3, r8, ip, lr, pc}^ │ │ │ │ - blmi 5add18 <__bss_end__@@Base+0x5070e0> │ │ │ │ + blmi 5addf0 <__bss_end__@@Base+0x507250> │ │ │ │ andsvs r4, sl, fp, ror r4 │ │ │ │ ldrbtmi r4, [fp], #-2837 @ 0xfffff4eb │ │ │ │ - blcs 2dc28 │ │ │ │ - blmi 547c0c <__bss_end__@@Base+0x4a0fd4> │ │ │ │ + blcs 2dd00 │ │ │ │ + blmi 547ce4 <__bss_end__@@Base+0x4a1144> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ ldmvs fp!, {r0, r2, r3, sp, lr, pc}^ │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, fp, sp, lr}^ │ │ │ │ subsvs r6, sl, r2, asr r8 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ andle r2, r4, r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldmdavs r2, {r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ andscs r6, ip, #26 │ │ │ │ ldmvs r8!, {r8, sp}^ │ │ │ │ - b 1351bac <__bss_end__@@Base+0x12aaf74> │ │ │ │ + ldmib sl!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ef68f8 │ │ │ │ - @ instruction: 0xe000eab0 │ │ │ │ + and lr, r0, lr, lsl sl │ │ │ │ ldrcc fp, [r0, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @ instruction: 0xffffff9d │ │ │ │ - andeq r7, r4, r4, lsr #28 │ │ │ │ - andeq r7, r4, r4, lsl lr │ │ │ │ - andeq r7, r4, lr, lsl #28 │ │ │ │ - andeq r7, r4, r4, lsl #28 │ │ │ │ + @ instruction: 0x00047cb4 │ │ │ │ + andeq r7, r4, r4, lsr #25 │ │ │ │ + muleq r4, lr, ip │ │ │ │ + muleq r4, r4, ip │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ tstle r7, r0, lsl #22 │ │ │ │ ldmdavs sl!, {r8, r9, sp} │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ mrc2 7, 6, pc, cr12, cr15, {7} │ │ │ │ subs r4, r9, r3, lsl #12 │ │ │ │ - blcs 2dd28 │ │ │ │ - blmi b8a460 <__bss_end__@@Base+0xae3828> │ │ │ │ + blcs 2de00 │ │ │ │ + blmi b8a538 <__bss_end__@@Base+0xae3998> │ │ │ │ addscs r4, r0, #2063597568 @ 0x7b000000 │ │ │ │ ldrbtmi r4, [r9], #-2348 @ 0xfffff6d4 │ │ │ │ ldrbtmi r4, [r8], #-2092 @ 0xfffff7d4 │ │ │ │ - b 14d1c0c <__bss_end__@@Base+0x142afd4> │ │ │ │ + stmib r0, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ cmnpvs r8, sp, lsr pc @ p-variant is OBSOLETE │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ andle r2, r7, r0, lsl #22 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ldrbtmi r4, [sl], #-2598 @ 0xfffff5da │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ - ldc2l 7, cr15, [ip, #1016] @ 0x3f8 │ │ │ │ + @ instruction: 0xf928f7ff │ │ │ │ andcs r6, r0, #2015232 @ 0x1ec000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, r8, sp, lr} │ │ │ │ @ instruction: 0x4619331c │ │ │ │ @ instruction: 0xf7ef6978 │ │ │ │ - teqvs r8, sl, asr ip │ │ │ │ - blcs 2e174 │ │ │ │ + teqvs r8, r2, asr #23 │ │ │ │ + blcs 2e24c │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, ip, lr, pc} │ │ │ │ - bmi 760900 <__bss_end__@@Base+0x6b9cc8> │ │ │ │ + bmi 7609d8 <__bss_end__@@Base+0x6b9e38> │ │ │ │ ldmvs r9!, {r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - @ instruction: 0xf7fe68f8 │ │ │ │ - ldmdbvs sl!, {r0, r1, r2, r6, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ + @ instruction: 0xf7ff68f8 │ │ │ │ + ldmdbvs sl!, {r0, r1, r4, r8, fp, ip, sp, lr, pc} │ │ │ │ addsmi r6, sl, #2015232 @ 0x1ec000 │ │ │ │ - blmi 687d08 <__bss_end__@@Base+0x5e10d0> │ │ │ │ + blmi 687de0 <__bss_end__@@Base+0x5e1240> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ addsmi r6, sl, #1998848 @ 0x1e8000 │ │ │ │ - blmi 6080bc <__bss_end__@@Base+0x561484> │ │ │ │ + blmi 608194 <__bss_end__@@Base+0x5615f4> │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldmdbvs fp!, {r1, r3, r4, sp, lr} │ │ │ │ - blcs 2dd28 │ │ │ │ + blcs 2de00 │ │ │ │ ldmdbvs fp!, {r0, r1, ip, lr, pc} │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, sp, lr} │ │ │ │ - blcs 2de38 │ │ │ │ + blcs 2df10 │ │ │ │ ldmdbvs fp!, {r0, r1, ip, lr, pc} │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r6, fp, sp, lr} │ │ │ │ ldmdbvs sl!, {r1, r3, r4, sp, lr} │ │ │ │ @ instruction: 0x03b1f646 │ │ │ │ bicscs pc, lr, #204472320 @ 0xc300000 │ │ │ │ ldmdbvs fp!, {r0, r1, r4, r7, r8, sp, lr} │ │ │ │ addsvs r6, sl, sl, lsr r8 │ │ │ │ tstcc ip, #966656 @ 0xec000 │ │ │ │ @ instruction: 0x37184618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq fp, r3, ip, lsl #20 │ │ │ │ - andeq fp, r3, r2, ror #14 │ │ │ │ - andeq fp, r3, sl, ror #14 │ │ │ │ - andeq fp, r3, sl, lsl #16 │ │ │ │ - andeq fp, r3, r4, lsr #16 │ │ │ │ - andeq r7, r4, r0, lsr #26 │ │ │ │ - andeq r7, r4, r4, lsl sp │ │ │ │ + andeq fp, r3, r4, lsr #18 │ │ │ │ + andeq fp, r3, r2, ror r6 │ │ │ │ + andeq fp, r3, r2, lsl #13 │ │ │ │ + andeq fp, r3, r2, lsr #14 │ │ │ │ + andeq fp, r3, ip, lsr r7 │ │ │ │ + @ instruction: 0x00047bb0 │ │ │ │ + andeq r7, r4, r4, lsr #23 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ - blcs 2e00c │ │ │ │ - blmi 54ad44 <__bss_end__@@Base+0x4a410c> │ │ │ │ + blcs 2e0e4 │ │ │ │ + blmi 54ae1c <__bss_end__@@Base+0x4a427c> │ │ │ │ adccs r4, r9, #2063597568 @ 0x7b000000 │ │ │ │ ldrbtmi r4, [r9], #-2323 @ 0xfffff6ed │ │ │ │ ldrbtmi r4, [r8], #-2067 @ 0xfffff7ed │ │ │ │ - stmib r0!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - blcc 6e024 <__bss_start@@Base+0x12f84> │ │ │ │ + stmdb lr, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blcc 6e0fc <__bss_start@@Base+0x130f4> │ │ │ │ ldrmi r6, [r3], #-2298 @ 0xfffff706 │ │ │ │ and r6, r9, fp, ror r1 │ │ │ │ ldmdavc sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x701a68fb │ │ │ │ movwcc r6, #6395 @ 0x18fb │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ rsbsvs r3, fp, r1, lsl #6 │ │ │ │ @@ -16847,33 +16928,33 @@ │ │ │ │ andle r4, r3, #-1610612727 @ 0xa0000009 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ andcs r6, r0, #16449536 @ 0xfb0000 │ │ │ │ svclt 0x0000701a │ │ │ │ ssatmi r3, #30, r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq fp, r3, r0, asr #18 │ │ │ │ - andeq fp, r3, lr, ror r6 │ │ │ │ - andeq fp, r3, sl, lsr #15 │ │ │ │ + andeq fp, r3, r8, asr r8 │ │ │ │ + andeq fp, r3, lr, lsl #11 │ │ │ │ + andeq fp, r3, r2, asr #13 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xf7ef6878 │ │ │ │ - strmi lr, [r3], -sl, asr #20 │ │ │ │ + @ instruction: 0x4603e9ba │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ ldmvs sl!, {r8, r9, sp}^ │ │ │ │ stmdami r8, {r1, r3, r4, r5, r7, r8, sp} │ │ │ │ @ instruction: 0xf7ff4478 │ │ │ │ adcsvs pc, r8, r5, lsr #28 │ │ │ │ @ instruction: 0x461a68fb │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - b fd1d6c <__bss_end__@@Base+0xf2b134> │ │ │ │ + stmib lr!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x461868bb │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq fp, r3, ip, lsl #12 │ │ │ │ + andeq fp, r3, ip, lsl r5 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ and r6, r5, r9, lsr r0 │ │ │ │ movwcc r6, #6203 @ 0x183b │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ rsbsvs r3, fp, r1, lsl #6 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ @@ -16882,48 +16963,48 @@ │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ smlalle r4, pc, sl, r2 @ │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ svclt 0x000c2b00 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0x4618b2db │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 151f78 <__bss_end__@@Base+0xab340> │ │ │ │ + blvc 152050 <__bss_end__@@Base+0xab4b0> │ │ │ │ ldrlt r4, [r0, #1904] @ 0x770 │ │ │ │ svcge 0x0000b083 │ │ │ │ eorsvs r6, r9, r8, ror r0 │ │ │ │ ldmdavs fp!, {r0, r2, sp, lr, pc} │ │ │ │ eorsvs r3, fp, r1, lsl #6 │ │ │ │ movwcc r6, #6267 @ 0x187b │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, sp, lr} │ │ │ │ - blcs 31e90 │ │ │ │ + blcs 31f68 │ │ │ │ ldmdavs fp!, {r0, r2, r3, ip, lr, pc} │ │ │ │ @ instruction: 0x4618781b │ │ │ │ - stmdb r6, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda r4!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r2, r9, sl, lr}^ │ │ │ │ @ instruction: 0x4618781b │ │ │ │ - stmdb r0, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda lr!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ addsmi r4, ip, #3145728 @ 0x300000 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r5, r6, r7, ip, lr, pc} │ │ │ │ - blcs 31eb4 │ │ │ │ + blcs 31f8c │ │ │ │ movwcs fp, #7948 @ 0x1f0c │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ ldclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - ldmib ip, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb ip, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ rscsvs r4, fp, r3, lsl #12 │ │ │ │ @ instruction: 0xf7ef6838 │ │ │ │ - @ instruction: 0x4603e9d8 │ │ │ │ + strmi lr, [r3], -r8, asr #18 │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r7, sp, lr}^ │ │ │ │ addsmi r6, sl, #12255232 @ 0xbb0000 │ │ │ │ movwcs sp, #2561 @ 0xa01 │ │ │ │ ldmvs sl!, {r0, r3, r4, sp, lr, pc}^ │ │ │ │ - bne ff4ee174 <__bss_end__@@Base+0xff44753c> │ │ │ │ + bne ff4ee24c <__bss_end__@@Base+0xff4476ac> │ │ │ │ ldrmi r6, [r3], #-2170 @ 0xfffff786 │ │ │ │ and r6, sp, fp, ror r0 │ │ │ │ ldmdavc sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ mulle r1, sl, r2 │ │ │ │ and r2, sl, r0, lsl #6 │ │ │ │ movwcc r6, #6267 @ 0x187b │ │ │ │ @@ -16933,67 +17014,67 @@ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ svcge 0x0002b088 │ │ │ │ ldrshtvs r6, [r9], r8 │ │ │ │ eorsvs r6, fp, sl, ror r0 │ │ │ │ - blcs 2e1bc │ │ │ │ + blcs 2e294 │ │ │ │ ldmdavs fp!, {r1, r8, r9, fp, ip, lr, pc} │ │ │ │ - ble 2dead8 <__bss_end__@@Base+0x237ea0> │ │ │ │ + ble 2debb0 <__bss_end__@@Base+0x238010> │ │ │ │ movwls r6, #2107 @ 0x83b │ │ │ │ - bmi 92e1cc <__bss_end__@@Base+0x887594> │ │ │ │ + bmi 92e2a4 <__bss_end__@@Base+0x887704> │ │ │ │ mvncs r4, sl, ror r4 │ │ │ │ ldrbtmi r4, [r8], #-2083 @ 0xfffff7dd │ │ │ │ - ldc2 7, cr15, [lr], {254} @ 0xfe │ │ │ │ - stmda ip!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blcs 2dfe0 │ │ │ │ + @ instruction: 0xffeaf7fe │ │ │ │ + svc 0x0098f7ee │ │ │ │ + blcs 2e0b8 │ │ │ │ ldmvs fp!, {r0, sl, fp, ip, lr, pc}^ │ │ │ │ ldmvs fp!, {r0, r2, r4, r5, sp, lr, pc} │ │ │ │ vstrle d2, [r3, #-0] │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ - ble 64970 <__bss_start@@Base+0x98d0> │ │ │ │ + ble 64a48 <__bss_start@@Base+0x9a40> │ │ │ │ eor r2, ip, r0, lsl #6 │ │ │ │ - blcs 6dffc <__bss_start@@Base+0x12f5c> │ │ │ │ + blcs 6e0d4 <__bss_start@@Base+0x130cc> │ │ │ │ ldmdavs fp!, {r0, r3, r8, ip, lr, pc}^ │ │ │ │ @ instruction: 0x4619781b │ │ │ │ @ instruction: 0x461a68bb │ │ │ │ @ instruction: 0xf7ef68f8 │ │ │ │ - strmi lr, [r3], -lr, lsr #22 │ │ │ │ + @ instruction: 0x4603ea90 │ │ │ │ ldmvs sl!, {r0, r1, r2, r3, r4, sp, lr, pc} │ │ │ │ - bne ff4ee018 <__bss_end__@@Base+0xff4473e0> │ │ │ │ + bne ff4ee0f0 <__bss_end__@@Base+0xff447550> │ │ │ │ ldrmi r6, [r3], #-2298 @ 0xfffff706 │ │ │ │ ands r6, r3, fp, ror r1 │ │ │ │ ldmdavc sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0xd10a429a │ │ │ │ @ instruction: 0x461a683b │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - stmda r4, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blcs 2575c │ │ │ │ + svc 0x0070f7ee │ │ │ │ + blcs 25834 │ │ │ │ ldmvs fp!, {r0, r8, ip, lr, pc}^ │ │ │ │ ldmvs fp!, {r0, r1, r2, sp, lr, pc}^ │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ stmible r7!, {r1, r3, r4, r7, r9, lr}^ │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ ssatmi r3, #30, r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq fp, r3, ip, lsl #12 │ │ │ │ - andeq fp, r3, r2, asr #9 │ │ │ │ + andeq fp, r3, r4, lsr #10 │ │ │ │ + ldrdeq fp, [r3], -r2 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ movwcs r6, #57 @ 0x39 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr} │ │ │ │ @ instruction: 0x4618781b │ │ │ │ - ldmda r6, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + svc 0x00c4f7ee │ │ │ │ ldrh r6, [r7], -r8 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - @ instruction: 0xf7ef4618 │ │ │ │ - @ instruction: 0x4602e850 │ │ │ │ + @ instruction: 0xf7ee4618 │ │ │ │ + @ instruction: 0x4602efbe │ │ │ │ addsmi r6, r3, #12255232 @ 0xbb0000 │ │ │ │ ldmdavs r9!, {r3, r8, ip, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -ip, lsr #30 │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ strd r6, [fp], -fp │ │ │ │ movwcc r6, #6267 @ 0x187b │ │ │ │ @@ -17003,60 +17084,60 @@ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - stmda r6, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + svc 0x0072f7ee │ │ │ │ ldmvs fp!, {r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ strd r6, [fp], -fp │ │ │ │ - blcs 2e0e4 │ │ │ │ + blcs 2e1bc │ │ │ │ ldmdavs fp!, {r0, ip, lr, pc} │ │ │ │ ldmdavs r9!, {r1, r2, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [fp], #-2820 @ 0xfffff4fc │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ - movwcs pc, #3161 @ 0xc59 @ │ │ │ │ + movwcs pc, #4005 @ 0xfa5 @ │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq fp, r3, r2, lsl r5 │ │ │ │ + andeq fp, r3, sl, lsr #8 │ │ │ │ strlt fp, [r0, #1039] @ 0x40f │ │ │ │ svcge 0x0000b082 │ │ │ │ ldrbtmi r4, [fp], #-2840 @ 0xfffff4e8 │ │ │ │ movwcc r6, #6171 @ 0x181b │ │ │ │ @ instruction: 0xf003425a │ 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#12 │ │ │ │ + andeq r8, r4, lr, asr #9 │ │ │ │ + @ instruction: 0x000484b6 │ │ │ │ + @ instruction: 0x000484b0 │ │ │ │ umulllt fp, r5, r0, r5 │ │ │ │ - blmi 7bff78 <__bss_end__@@Base+0x719340> │ │ │ │ + blmi 7c0050 <__bss_end__@@Base+0x7194b0> │ │ │ │ andcs r4, r1, #2063597568 @ 0x7b000000 │ │ │ │ - blmi 76c3e8 <__bss_end__@@Base+0x6c57b0> │ │ │ │ + blmi 76c4c0 <__bss_end__@@Base+0x6c5920> │ │ │ │ eorcs r4, r0, #2063597568 @ 0x7b000000 │ │ │ │ - blmi 72c3f0 <__bss_end__@@Base+0x6857b8> │ │ │ │ + blmi 72c4c8 <__bss_end__@@Base+0x685928> │ │ │ │ @ instruction: 0xf04f447b │ │ │ │ @ instruction: 0x601a32ff │ │ │ │ - blmi 6cc3c8 <__bss_end__@@Base+0x625790> │ │ │ │ + blmi 6cc4a0 <__bss_end__@@Base+0x625900> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - blmi 656504 <__bss_end__@@Base+0x5af8cc> │ │ │ │ + blmi 6565dc <__bss_end__@@Base+0x5afa3c> │ │ │ │ andsvs r4, sl, fp, ror r4 │ │ │ │ ldrbtmi r4, [fp], #-2840 @ 0xfffff4e8 │ │ │ │ mrcne 8, 2, r6, cr10, cr11, {0} │ │ │ │ ldrbtmi r4, [fp], #-2839 @ 0xfffff4e9 │ │ │ │ - blmi 5ec418 <__bss_end__@@Base+0x5457e0> │ │ │ │ + blmi 5ec4f0 <__bss_end__@@Base+0x545950> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ svcmi 0x0000f5b3 │ │ │ │ ldrtmi sp, [fp], -fp, ror #5 │ │ │ │ ldrmi r2, [r8], -r0, lsl #2 │ │ │ │ - cdp 7, 4, cr15, cr8, cr14, {7} │ │ │ │ + ldc 7, cr15, [r6, #952]! @ 0x3b8 │ │ │ │ movwcs lr, #2519 @ 0x9d7 │ │ │ │ ldmib r7, {r0, r4, r9, sl, lr}^ │ │ │ │ ldrmi r2, [r3], -r2, lsl #6 │ │ │ │ @ instruction: 0xf7ee18cc │ │ │ │ - @ instruction: 0x4603ef3a │ │ │ │ - @ instruction: 0xf7ef441c │ │ │ │ - @ instruction: 0x4603e85e │ │ │ │ + strmi lr, [r3], -sl, lsr #29 │ │ │ │ + @ instruction: 0xf7ee441c │ │ │ │ + strmi lr, [r3], -r6, asr #31 │ │ │ │ ldrmi r4, [r8], -r3, lsr #8 │ │ │ │ @ instruction: 0xf814f000 │ │ │ │ ldrcc fp, [r4, -r0, lsl #30] │ │ │ │ ldclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - strdeq r8, [r4], -ip │ │ │ │ - strdeq r8, [r4], -ip │ │ │ │ - strdeq r8, [r4], -r0 │ │ │ │ - andeq r8, r4, r4, ror #11 │ │ │ │ - ldrdeq r8, [r4], -ip │ │ │ │ - ldrdeq r8, [r4], -sl │ │ │ │ - ldrdeq r8, [r4], -r2 │ │ │ │ - andeq r8, r4, r8, asr #11 │ │ │ │ + andeq r8, r4, ip, lsl #9 │ │ │ │ + andeq r8, r4, ip, lsl #9 │ │ │ │ + andeq r8, r4, r0, lsl #9 │ │ │ │ + andeq r8, r4, r4, ror r4 │ │ │ │ + andeq r8, r4, ip, ror #8 │ │ │ │ + andeq r8, r4, sl, ror #8 │ │ │ │ + andeq r8, r4, r2, ror #8 │ │ │ │ + andeq r8, r4, r8, asr r4 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldrbtmi r4, [fp], #-2822 @ 0xfffff4fa │ │ │ │ - blcs 2e48c │ │ │ │ + blcs 2e564 │ │ │ │ @ instruction: 0xf7ffd101 │ │ │ │ ldmdavs r8!, {r0, r2, r5, r7, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xff70f7ff │ │ │ │ strcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r8, r4, sl, asr r5 │ │ │ │ + andeq r8, r4, sl, ror #7 │ │ │ │ umulllt fp, r7, r0, r5 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs sl!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ addsmi r6, sl, #3866624 @ 0x3b0000 │ │ │ │ - blmi d0b86c <__bss_end__@@Base+0xc64c34> │ │ │ │ + blmi d0b944 <__bss_end__@@Base+0xc64da4> │ │ │ │ rsbscs r4, r0, #2063597568 @ 0x7b000000 │ │ │ │ ldrbtmi r4, [r9], #-2354 @ 0xfffff6ce │ │ │ │ ldrbtmi r4, [r8], #-2098 @ 0xfffff7ce │ │ │ │ - cdp 7, 4, cr15, cr12, cr14, {7} │ │ │ │ + ldc 7, cr15, [sl, #952]! @ 0x3b8 │ │ │ │ ldrbtmi r4, [fp], #-2865 @ 0xfffff4cf │ │ │ │ - blcs 2e4d0 │ │ │ │ + blcs 2e5a8 │ │ │ │ @ instruction: 0xf7ffd101 │ │ │ │ ldmdavs sl!, {r0, r1, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - bne ff4ee65c <__bss_end__@@Base+0xff447a24> │ │ │ │ + bne ff4ee734 <__bss_end__@@Base+0xff447b94> │ │ │ │ @ instruction: 0xf7ff60fb │ │ │ │ @ instruction: 0x4603ff5b │ │ │ │ - blmi aeca68 <__bss_end__@@Base+0xa45e30> │ │ │ │ + blmi aecb40 <__bss_end__@@Base+0xa45fa0> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ands r6, r9, fp, lsr r1 │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ - blmi a246f8 <__bss_end__@@Base+0x97dac0> │ │ │ │ + blmi a247d0 <__bss_end__@@Base+0x97dc30> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ teqvs fp, r3, lsl r3 │ │ │ │ ldrbtmi r4, [fp], #-2854 @ 0xfffff4da │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, fp, sp, lr}^ │ │ │ │ vst1.8 {d15-d16}, [r3], r2 │ │ │ │ @ instruction: 0xff42f7ff │ │ │ │ ldrmi r4, [sl], -r3, lsl #12 │ │ │ │ @@ -17322,217 +17403,217 @@ │ │ │ │ @ instruction: 0xd103429a │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ands r4, pc, r3, lsl r4 @ │ │ │ │ ldmvs fp!, {r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r1, r4, r6, r7, r9, fp, ip}^ │ │ │ │ ldrmi r3, [r9], -r1, lsl #6 │ │ │ │ @ instruction: 0xf0344610 │ │ │ │ - @ instruction: 0x460bfdd7 │ │ │ │ + strmi pc, [fp], -pc, lsr #26 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r7, sp, lr} │ │ │ │ andle r2, r6, r0, lsl #22 │ │ │ │ ldmvs fp!, {r1, r3, r4, r5, r8, fp, sp, lr} │ │ │ │ ldmdbvs sl!, {r0, r1, r4, r6, r7, r9, fp, ip}^ │ │ │ │ stmdble r0, {r1, r3, r4, r7, r9, lr} │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, sl, fp, ip}^ │ │ │ │ @ instruction: 0x46184611 │ │ │ │ - stc2l 0, cr15, [r4, #208] @ 0xd0 │ │ │ │ + ldc2 0, cr15, [ip, #-208] @ 0xffffff30 │ │ │ │ ldrmi r4, [sl], -fp, lsl #12 │ │ │ │ ldrmi r6, [r3], #-2171 @ 0xfffff785 │ │ │ │ @ instruction: 0x371c4618 │ │ │ │ ldclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq fp, r3, ip, lsr r2 │ │ │ │ - andeq fp, r3, r2, lsr #4 │ │ │ │ - andeq fp, r3, r6, lsr #4 │ │ │ │ - andeq r8, r4, r6, lsl r5 │ │ │ │ - strdeq r8, [r4], -ip │ │ │ │ - strdeq r8, [r4], -r6 │ │ │ │ - andeq r8, r4, r8, ror #9 │ │ │ │ - andeq r8, r4, r2, ror #9 │ │ │ │ - andeq r8, r4, sl, asr #9 │ │ │ │ + andeq fp, r3, r4, asr r1 │ │ │ │ + andeq fp, r3, sl, lsr r1 │ │ │ │ + andeq fp, r3, lr, lsr r1 │ │ │ │ + andeq r8, r4, r6, lsr #7 │ │ │ │ + andeq r8, r4, ip, lsl #7 │ │ │ │ + andeq r8, r4, r6, lsl #7 │ │ │ │ + andeq r8, r4, r8, ror r3 │ │ │ │ + andeq r8, r4, r2, ror r3 │ │ │ │ + andeq r8, r4, sl, asr r3 │ │ │ │ umulllt fp, r3, r0, r5 │ │ │ │ - blmi 840144 <__bss_end__@@Base+0x79950c> │ │ │ │ + blmi 84021c <__bss_end__@@Base+0x79967c> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ @ instruction: 0xff10f7ff │ │ │ │ mcr2 7, 7, pc, cr12, cr15, {7} @ │ │ │ │ rsbsvs r4, fp, r3, lsl #12 │ │ │ │ ldrbtmi r4, [fp], #-2843 @ 0xfffff4e5 │ │ │ │ eorsvs r6, fp, fp, lsl r8 │ │ │ │ - blmi 6cc5a4 <__bss_end__@@Base+0x62596c> │ │ │ │ + blmi 6cc67c <__bss_end__@@Base+0x625adc> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - blx ae754 <__bss_end__@@Base+0x7b1c> │ │ │ │ + blx ae82c <__bss_end__@@Base+0x7c8c> │ │ │ │ @ instruction: 0xf7fff403 │ │ │ │ @ instruction: 0x4603fedd │ │ │ │ rsbsvs r4, fp, r3, lsr #6 │ │ │ │ ldrbtmi r4, [fp], #-2837 @ 0xfffff4eb │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ eorsvs r4, fp, r3, lsl r4 │ │ │ │ - blcs 7ae674 <__bss_end__@@Base+0x707a3c> │ │ │ │ + blcs 7ae74c <__bss_end__@@Base+0x707bac> │ │ │ │ ldmdavs fp!, {r0, r1, r3, r5, r6, r7, r8, fp, ip, lr, pc} │ │ │ │ stmdale r2, {r0, r1, r2, r3, r4, r8, r9, fp, sp} │ │ │ │ subseq r6, fp, fp, ror r8 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, sp, lr}^ │ │ │ │ - bcc fe44fdb8 <__bss_end__@@Base+0xfe3a9180> │ │ │ │ - blvc 1a10080 <__bss_end__@@Base+0x1969448> │ │ │ │ - blvs 1cfc20 <__bss_end__@@Base+0x128fe8> │ │ │ │ - blpl 1cffc4 <__bss_end__@@Base+0x12938c> │ │ │ │ - blvc 119006c <__bss_end__@@Base+0x10e9434> │ │ │ │ - bleq 1210070 <__bss_end__@@Base+0x1169438> │ │ │ │ + bcc fe44fe90 <__bss_end__@@Base+0xfe3a92f0> │ │ │ │ + blvc 1a10158 <__bss_end__@@Base+0x19695b8> │ │ │ │ + blvs 1cfcf8 <__bss_end__@@Base+0x129158> │ │ │ │ + blpl 1d009c <__bss_end__@@Base+0x1294fc> │ │ │ │ + blvc 1190144 <__bss_end__@@Base+0x10e95a4> │ │ │ │ + bleq 1210148 <__bss_end__@@Base+0x11695a8> │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ svclt 0x0000bd90 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ mvnsmi r0, r0 │ │ │ │ - andeq r8, r4, r0, lsr r4 │ │ │ │ - andeq r8, r4, r2, lsr #8 │ │ │ │ - andeq r8, r4, r8, lsl r4 │ │ │ │ - andeq r8, r4, r2, lsl #8 │ │ │ │ + andeq r8, r4, r0, asr #5 │ │ │ │ + @ instruction: 0x000482b2 │ │ │ │ + andeq r8, r4, r8, lsr #5 │ │ │ │ + muleq r4, r2, r2 │ │ │ │ svcge 0x0000b580 │ │ │ │ @ instruction: 0xffb0f7ff │ │ │ │ - blvc 10500a0 <__bss_end__@@Base+0xfa9468> │ │ │ │ - blvc 20fec0 <__bss_end__@@Base+0x169288> │ │ │ │ - blvs 500c4 │ │ │ │ - blvc 11cfec8 <__bss_end__@@Base+0x1129290> │ │ │ │ - bleq 12100b0 <__bss_end__@@Base+0x1169478> │ │ │ │ + blvc 1050178 <__bss_end__@@Base+0xfa95d8> │ │ │ │ + blvc 20ff98 <__bss_end__@@Base+0x1693f8> │ │ │ │ + blvs 5019c │ │ │ │ + blvc 11cffa0 <__bss_end__@@Base+0x1129400> │ │ │ │ + bleq 1210188 <__bss_end__@@Base+0x11695e8> │ │ │ │ ldrlt fp, [r0, #3456] @ 0xd80 │ │ │ │ svcge 0x0000b085 │ │ │ │ eorsvs r6, r9, r8, ror r0 │ │ │ │ ldrbtmi r4, [fp], #-2846 @ 0xfffff4e2 │ │ │ │ - blcs 2e670 │ │ │ │ + blcs 2e748 │ │ │ │ @ instruction: 0xf7ffd101 │ │ │ │ movwcs pc, #3763 @ 0xeb3 @ │ │ │ │ movwcs r6, #251 @ 0xfb │ │ │ │ strht r6, [r8], -fp │ │ │ │ ldrbtmi r4, [fp], #-2841 @ 0xfffff4e7 │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, fp, sp, lr}^ │ │ │ │ vst1.8 {d15-d16}, [r3], r2 │ │ │ │ mcr2 7, 4, pc, cr4, cr15, {7} @ │ │ │ │ @ instruction: 0x43234603 │ │ │ │ - blmi 56ca18 <__bss_end__@@Base+0x4c5de0> │ │ │ │ + blmi 56caf0 <__bss_end__@@Base+0x4c5f50> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldrmi r6, [r3], #-2234 @ 0xfffff746 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r7, sp, lr} │ │ │ │ stmdble r1, {r5, r8, r9, fp, sp} │ │ │ │ adcsvs r2, fp, r0, lsr #6 │ │ │ │ - blcs 1ee930 <__bss_end__@@Base+0x147cf8> │ │ │ │ + blcs 1eea08 <__bss_end__@@Base+0x147e68> │ │ │ │ ldmvs fp!, {r1, r2, r5, r6, r7, r8, sl, fp, ip, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r7, r9, ip, sp, pc}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, ip, sp, lr}^ │ │ │ │ rscsvs r0, fp, fp, lsl sl │ │ │ │ - blcc 22e944 <__bss_end__@@Base+0x187d0c> │ │ │ │ + blcc 22ea1c <__bss_end__@@Base+0x187e7c> │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r7, sp, lr}^ │ │ │ │ rsbsvs r3, fp, r1, lsl #6 │ │ │ │ - blcc 6e750 <__bss_start@@Base+0x136b0> │ │ │ │ + blcc 6e828 <__bss_start@@Base+0x13820> │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr} │ │ │ │ vstmiale r9!, {d18-d17} │ │ │ │ svclt 0x0000bf00 │ │ │ │ ssatmi r3, #30, r4, lsl #14 │ │ │ │ svclt 0x0000bd90 │ │ │ │ - andeq r8, r4, r6, ror r3 │ │ │ │ - andeq r8, r4, r6, ror #6 │ │ │ │ - andeq r8, r4, r0, asr r3 │ │ │ │ + andeq r8, r4, r6, lsl #4 │ │ │ │ + strdeq r8, [r4], -r6 │ │ │ │ + andeq r8, r4, r0, ror #3 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ rscsvs r6, fp, fp, ror r8 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7ee4618 │ │ │ │ - ldmvs fp!, {r1, r5, r7, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmvs fp!, {r1, r2, r3, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - blx 15526a0 <__bss_end__@@Base+0x14aba68> │ │ │ │ + blx 1552778 <__bss_end__@@Base+0x14abbd8> │ │ │ │ ldrcc fp, [r0, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldrbtmi r4, [fp], #-2841 @ 0xfffff4e7 │ │ │ │ @ instruction: 0x21202210 │ │ │ │ ldrbtmi r4, [r8], #-2072 @ 0xfffff7e8 │ │ │ │ @ instruction: 0xf994f7ff │ │ │ │ ldmdavs r8!, {r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ - blx 16d26ca <__bss_end__@@Base+0x162ba92> │ │ │ │ + blx 16d27a2 <__bss_end__@@Base+0x162bc02> │ │ │ │ ldmvs fp!, {r1, r9, sl, lr}^ │ │ │ │ - blmi 52c73c <__bss_end__@@Base+0x485b04> │ │ │ │ + blmi 52c814 <__bss_end__@@Base+0x485c74> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ee6878 │ │ │ │ - @ instruction: 0x4603edb0 │ │ │ │ + strmi lr, [r3], -r0, lsr #26 │ │ │ │ ldmvs fp!, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ - blcs 2e858 │ │ │ │ + blcs 2e930 │ │ │ │ @ instruction: 0xf7eed10a │ │ │ │ - strmi lr, [r3], -sl, ror #30 │ │ │ │ + strmi lr, [r3], -ip, asr #29 │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - ldc 7, cr15, [r4], {238} @ 0xee │ │ │ │ + bl fe05278c <__bss_end__@@Base+0xfdfabbec> │ │ │ │ ldmvs fp!, {r1, r9, sl, lr}^ │ │ │ │ mul r2, sl, r0 │ │ │ │ andcs r6, r0, #16449536 @ 0xfb0000 │ │ │ │ ldmvs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ sbcsvs r2, sl, r0, lsl #4 │ │ │ │ @ instruction: 0x461868fb │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ @ instruction: 0xffffffcb │ │ │ │ - ldrdeq sl, [r3], -lr │ │ │ │ - ldrdeq sl, [r3], -r4 │ │ │ │ + strdeq sl, [r3], -r6 │ │ │ │ + andeq sl, r3, ip, ror #29 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ rsb r2, fp, r0, lsl #6 │ │ │ │ ldmvs fp!, {r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0x461a685b │ │ │ │ @ instruction: 0xf7ee6879 │ │ │ │ - strmi lr, [r3], -lr, asr #24 │ │ │ │ + @ instruction: 0x4603ebba │ │ │ │ tstle r3, r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7ee4618 │ │ │ │ - strmi lr, [r3], -r6, ror #29 │ │ │ │ + strmi lr, [r3], -lr, asr #28 │ │ │ │ andle r2, r9, r0, lsl #22 │ │ │ │ - svc 0x002ef7ee │ │ │ │ + cdp 7, 9, cr15, cr0, cr14, {7} │ │ │ │ ldmdavs fp, {r0, r1, r9, sl, lr} │ │ │ │ @ instruction: 0xf7ee4618 │ │ │ │ - @ instruction: 0x4602ebda │ │ │ │ + strmi lr, [r2], -r6, asr #22 │ │ │ │ @ instruction: 0x609a68fb │ │ │ │ sub r2, sp, r0, lsl #6 │ │ │ │ @ instruction: 0x461868bb │ │ │ │ - stcl 7, cr15, [lr, #-952] @ 0xfffffc48 │ │ │ │ + ldc 7, cr15, [lr], #952 @ 0x3b8 │ │ │ │ cmnvs fp, r3, lsl #12 │ │ │ │ ldmvs sl!, {r3, sp, lr, pc} │ │ │ │ - blcc 6ed7c <__bss_start@@Base+0x13cdc> │ │ │ │ + blcc 6ee54 <__bss_start@@Base+0x13e4c> │ │ │ │ andcs r4, r0, #318767104 @ 0x13000000 │ │ │ │ ldmdbvs fp!, {r1, r3, r4, ip, sp, lr}^ │ │ │ │ cmnvs fp, r1, lsl #22 │ │ │ │ - blcs 2ed8c │ │ │ │ + blcs 2ee64 │ │ │ │ @ instruction: 0xf7eedd0f │ │ │ │ - @ instruction: 0x4603edf2 │ │ │ │ + strmi lr, [r3], -r2, ror #26 │ │ │ │ ldmvs r9!, {r1, r3, r4, fp, sp, lr} │ │ │ │ - blcc 6ed9c <__bss_start@@Base+0x13cfc> │ │ │ │ + blcc 6ee74 <__bss_start@@Base+0x13e6c> │ │ │ │ ldmdavc fp, {r0, r1, r3, sl, lr} │ │ │ │ ldrmi r0, [r3], #-91 @ 0xffffffa5 │ │ │ │ vst2.8 {d8-d9}, [r3 :64], fp │ │ │ │ - blcs 293c0 │ │ │ │ + blcs 29498 │ │ │ │ movwcs sp, #483 @ 0x1e3 │ │ │ │ and r6, r2, fp, lsr r1 │ │ │ │ movwcc r6, #6459 @ 0x193b │ │ │ │ @ instruction: 0xf7ee613b │ │ │ │ - @ instruction: 0x4603eddc │ │ │ │ + strmi lr, [r3], -ip, asr #26 │ │ │ │ ldmvs r9!, {r1, r3, r4, fp, sp, lr} │ │ │ │ strmi r6, [fp], #-2363 @ 0xfffff6c5 │ │ │ │ subseq r7, fp, fp, lsl r8 │ │ │ │ ldmdahi fp, {r0, r1, r4, sl, lr} │ │ │ │ movwpl pc, #1027 @ 0x403 @ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ - blcs 2ecdc │ │ │ │ + blcs 2edb4 │ │ │ │ ldmvs sl!, {r2, r3, r8, sl, fp, ip, lr, pc} │ │ │ │ ldmne r1, {r0, r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r5, r6, r8, fp, sp, lr} │ │ │ │ movwcc r1, #6867 @ 0x1ad3 │ │ │ │ @ instruction: 0xf107461a │ │ │ │ ldrmi r0, [r8], -r8, lsl #6 │ │ │ │ - cdp 7, 1, cr15, cr4, cr14, {7} │ │ │ │ + ldcl 7, cr15, [ip, #-952]! @ 0xfffffc48 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, r6, sl, fp, ip}^ │ │ │ │ movwcs r6, #4314 @ 0x10da │ │ │ │ @ instruction: 0x37184618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @@ -17555,15 +17636,15 @@ │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ strmi sl, [r3], -r0, lsl #30 │ │ │ │ ldmibvc fp!, {r0, r1, r3, r4, r5, r6, r7, r8, ip, sp, lr}^ │ │ │ │ svclt 0x000c2b2f │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0x4618b2db │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 1529fc <__bss_end__@@Base+0xabdc4> │ │ │ │ + blvc 152ad4 <__bss_end__@@Base+0xabf34> │ │ │ │ strlt r4, [r0, #1904] @ 0x770 │ │ │ │ svcge 0x0000b082 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ andle r2, r3, r0, lsl #22 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, r5, r1, lsl #6 │ │ │ │ @@ -17572,94 +17653,94 @@ │ │ │ │ @ instruction: 0x4603ffdd │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, sp, lr} │ │ │ │ @ instruction: 0xffe1f7ff │ │ │ │ - blcs 260d8 │ │ │ │ + blcs 261b0 │ │ │ │ ldmdavs r8!, {r2, ip, lr, pc} │ │ │ │ - blx 15d28d0 <__bss_end__@@Base+0x152bc98> │ │ │ │ + blx 15d29a8 <__bss_end__@@Base+0x152be08> │ │ │ │ eors r4, r5, r3, lsl #12 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ tstle r4, pc, lsr #22 │ │ │ │ @ instruction: 0xf7ff6838 │ │ │ │ strmi pc, [r3], -sp, asr #20 │ │ │ │ @ instruction: 0x212fe02c │ │ │ │ @ instruction: 0xf7ee6878 │ │ │ │ - cmnvs r8, r0, ror #26 │ │ │ │ - blcs 2eee4 │ │ │ │ + ldrsbvs lr, [r8, #-192]! @ 0xffffff40 │ │ │ │ + blcs 2efbc │ │ │ │ ldmdavs r8!, {r2, r8, ip, lr, pc} │ │ │ │ - blx 10528fc <__bss_end__@@Base+0xfabcc4> │ │ │ │ + blx 10529d4 <__bss_end__@@Base+0xfabe34> │ │ │ │ ands r4, pc, r3, lsl #12 │ │ │ │ @ instruction: 0xf7ee6838 │ │ │ │ - strmi lr, [r1], -ip, lsl #25 │ │ │ │ + @ instruction: 0x4601ebfc │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ strmi r1, [fp], #-2771 @ 0xfffff52d │ │ │ │ teqvs fp, r2, lsl #6 │ │ │ │ ldmdbvs sl!, {r8, r9, sp} │ │ │ │ stmdami fp, {r1, r2, r3, r7, r8, sp} │ │ │ │ @ instruction: 0xf7ff4478 │ │ │ │ rscsvs pc, r8, r3, ror #16 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ movwcc r1, #6867 @ 0x1ad3 │ │ │ │ ldmdavs r9!, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7ee68f8 │ │ │ │ - ldmdavs r9!, {r2, r3, r6, r8, r9, fp, sp, lr, pc} │ │ │ │ + ldmdavs r9!, {r3, r4, r5, r7, r9, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ee68f8 │ │ │ │ - ldmvs fp!, {r2, r4, r5, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmvs fp!, {r2, r3, r4, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0x37184618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq sl, r3, ip, ror sp │ │ │ │ + muleq r3, r4, ip │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldrbtmi r4, [fp], #-2826 @ 0xfffff4f6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - stcl 7, cr15, [ip], #-952 @ 0xfffffc48 │ │ │ │ + bl ff7529f4 <__bss_end__@@Base+0xff6abe54> │ │ │ │ rscsvs r4, fp, r3, lsl #12 │ │ │ │ - blcs 2ed58 │ │ │ │ + blcs 2ee30 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmvs r8!, {r0, r1, sp, lr, pc}^ │ │ │ │ - bl cd2930 <__bss_end__@@Base+0xc2bcf8> │ │ │ │ + b fe7d2a08 <__bss_end__@@Base+0xfe72be68> │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq sl, r3, lr, asr #26 │ │ │ │ + andeq sl, r3, r6, ror #24 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, sp, lr} │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ ldmvs fp!, {r1, sp, lr, pc}^ │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ - ldcl 7, cr15, [r0], #952 @ 0x3b8 │ │ │ │ + stcl 7, cr15, [r0], #-952 @ 0xfffffc48 │ │ │ │ ldmdavs sl, {r0, r1, r9, sl, lr} │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldrmi r0, [r3], #-91 @ 0xffffffa5 │ │ │ │ vst2.8 {d8-d9}, [r3 :64], fp │ │ │ │ - blcs 295bc │ │ │ │ + blcs 29694 │ │ │ │ ldmvs fp!, {r0, r1, r2, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ - blcs 32a30 │ │ │ │ + blcs 32b08 │ │ │ │ movwcs sp, #4353 @ 0x1101 │ │ │ │ ldmdavs fp!, {r4, r5, sp, lr, pc} │ │ │ │ @ instruction: 0xdc012b00 │ │ │ │ eor r2, fp, r0, lsl #6 │ │ │ │ - blcc 6eac4 <__bss_start@@Base+0x13a24> │ │ │ │ + blcc 6eb9c <__bss_start@@Base+0x13b94> │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, sp, lr} │ │ │ │ mrrcne 8, 1, r6, sl, cr11 │ │ │ │ @ instruction: 0x601a68bb │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ rsbsvs r3, fp, r4, lsl #6 │ │ │ │ movwcc r6, #6395 @ 0x18fb │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ - blcs 32a68 │ │ │ │ + blcs 32b40 │ │ │ │ movwcs sp, #4353 @ 0x1101 │ │ │ │ @ instruction: 0xf7eee014 │ │ │ │ - strmi lr, [r3], -r2, asr #25 │ │ │ │ + @ instruction: 0x4603ec32 │ │ │ │ ldmvs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ subseq r7, fp, fp, lsl r8 │ │ │ │ ldmdahi fp, {r0, r1, r4, sl, lr} │ │ │ │ movwpl pc, #1027 @ 0x403 @ │ │ │ │ rscle r2, r9, r0, lsl #22 │ │ │ │ andcs r6, r0, #16449536 @ 0xfb0000 │ │ │ │ ldmvs fp!, {r1, r3, r4, ip, sp, lr}^ │ │ │ │ @@ -17670,479 +17751,393 @@ │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, sp, lr} │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ ldmvs fp!, {r1, sp, lr, pc}^ │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ - ldc 7, cr15, [sl], {238} @ 0xee │ │ │ │ + stc 7, cr15, [sl], {238} @ 0xee │ │ │ │ ldmdavs sl, {r0, r1, r9, sl, lr} │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldrmi r0, [r3], #-91 @ 0xffffffa5 │ │ │ │ vst2.8 {d8-d9}, [r3 :64], fp │ │ │ │ - blcs 29668 │ │ │ │ + blcs 29740 │ │ │ │ ldmvs fp!, {r0, r1, r2, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ - blcs 32adc │ │ │ │ + blcs 32bb4 │ │ │ │ movwcs sp, #4353 @ 0x1101 │ │ │ │ ldmdavs fp!, {r1, r2, r4, r5, r6, sp, lr, pc} │ │ │ │ @ instruction: 0xdc012b00 │ │ │ │ rsbs r2, r1, r0, lsl #6 │ │ │ │ - blcc 6eb70 <__bss_start@@Base+0x13ad0> │ │ │ │ + blcc 6ec48 <__bss_start@@Base+0x13c40> │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, sp, lr} │ │ │ │ mrrcne 8, 1, r6, sl, cr11 │ │ │ │ @ instruction: 0x601a68bb │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ rsbsvs r3, fp, r4, lsl #6 │ │ │ │ ldrshvs r6, [fp, #-139]! @ 0xffffff75 │ │ │ │ ldrbtvc r2, [fp], #768 @ 0x300 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ tstle ip, r2, lsr #22 │ │ │ │ - blcs 33e9c │ │ │ │ + blcs 33f74 │ │ │ │ ldmvs fp!, {r0, r1, r4, ip, lr, pc}^ │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ tstle r9, r2, lsr #22 │ │ │ │ movwcc r6, #6395 @ 0x18fb │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ andsvc r2, sl, r2, lsr #4 │ │ │ │ movwcc r6, #6523 @ 0x197b │ │ │ │ @ instruction: 0xe7e7617b │ │ │ │ ldrbtvc r2, [fp], #768 @ 0x300 │ │ │ │ movwcs lr, #6116 @ 0x17e4 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sl, ip, sp, lr}^ │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ ldmvs fp!, {r1, r2, r3, r4, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ - blcs 32b58 │ │ │ │ + blcs 32c30 │ │ │ │ ldmdbvs fp!, {r2, r8, ip, lr, pc}^ │ │ │ │ andsvc r2, sl, r0, lsl #4 │ │ │ │ eors r2, r5, r1, lsl #6 │ │ │ │ - blcs 33ee8 │ │ │ │ + blcs 33fc0 │ │ │ │ ldmvs fp!, {r1, r3, ip, lr, pc}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, fp, ip, sp, lr}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, ip, sp, lr}^ │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ movwcc r6, #6523 @ 0x197b │ │ │ │ @ instruction: 0xe7c7617b │ │ │ │ - ldc 7, cr15, [r8], #-952 @ 0xfffffc48 │ │ │ │ + bl fea52ba8 <__bss_end__@@Base+0xfe9ac008> │ │ │ │ ldmdavs sl, {r0, r1, r9, sl, lr} │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldrmi r0, [r3], #-91 @ 0xffffffa5 │ │ │ │ vst2.8 {d8-d9}, [r3 :64], fp │ │ │ │ - blcs 2972c │ │ │ │ + blcs 29804 │ │ │ │ ldmvs fp!, {r0, r1, ip, lr, pc}^ │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ ldmvs fp!, {r1, r2, r4, r5, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ - blcs b32ba8 <__bss_end__@@Base+0xa8bf70> │ │ │ │ + blcs b32c80 <__bss_end__@@Base+0xa8c0e0> │ │ │ │ ldmvs fp!, {r1, r2, r8, ip, lr, pc}^ │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ andcs r6, r0, #2015232 @ 0x1ec000 │ │ │ │ and r7, sl, sl, lsl r0 │ │ │ │ ldmdavc sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ andsvc r6, sl, fp, ror r9 │ │ │ │ movwcc r6, #6395 @ 0x18fb │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ cmnvs fp, r1, lsl #6 │ │ │ │ ldrb lr, [r1, -r0, lsr #15]! │ │ │ │ @ instruction: 0x37184618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - addlt fp, r6, r0, lsl #11 │ │ │ │ - rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - rscsvs r6, fp, fp, ror r8 │ │ │ │ - blcs 2ef68 │ │ │ │ - ldmvs fp!, {r2, r3, r5, ip, lr, pc}^ │ │ │ │ - blcc 6ecf0 <__bss_start@@Base+0x13c50> │ │ │ │ - ands r6, lr, fp, ror r1 │ │ │ │ - ldmvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ - addseq r6, fp, fp, ror r9 │ │ │ │ - ldmdavs fp, {r0, r1, r4, sl, lr} │ │ │ │ - ands r6, r0, fp, lsr r1 │ │ │ │ - ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ - tstle r4, r0, lsl #22 │ │ │ │ - ldmvs fp, {r0, r1, r3, r4, r5, r8, fp, sp, lr} │ │ │ │ - @ instruction: 0xf7fe4618 │ │ │ │ - ldmdbvs fp!, {r0, r4, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - adcsvs r6, fp, fp, lsl r8 │ │ │ │ - @ instruction: 0xf7fe6938 │ │ │ │ - ldmvs fp!, {r0, r1, r3, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - ldmdbvs fp!, {r0, r1, r3, r4, r5, r8, sp, lr} │ │ │ │ - mvnle r2, r0, lsl #22 │ │ │ │ - blcc 6f1b0 <__bss_start@@Base+0x14110> │ │ │ │ - ldmdbvs fp!, {r0, r1, r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ - ble ff75f7cc <__bss_end__@@Base+0xff6b8b94> │ │ │ │ - ldmvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ - @ instruction: 0xf7fe4618 │ │ │ │ - @ instruction: 0xe000ffbb │ │ │ │ - ldrcc fp, [r8, -r0, lsl #30] │ │ │ │ - stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - addlt fp, r4, r0, lsl #11 │ │ │ │ - rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - movwcs r6, #12345 @ 0x3039 │ │ │ │ - strd r6, [r3], -fp │ │ │ │ - ldrsheq r6, [fp], #-139 @ 0xffffff75 │ │ │ │ - rscsvs r3, fp, r1, lsl #6 │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ - blle ffde5668 <__bss_end__@@Base+0xffd3ea30> │ │ │ │ - ldrshtvs r6, [fp], #-139 @ 0xffffff75 │ │ │ │ - ldrbtmi r4, [fp], #-2835 @ 0xfffff4ed │ │ │ │ - orrcs r2, r4, ip, lsl #4 │ │ │ │ - ldrbtmi r4, [r8], #-2066 @ 0xfffff7ee │ │ │ │ - mcr2 7, 7, pc, cr12, cr14, {7} @ │ │ │ │ - ldmvs fp!, {r3, r4, r5, r7, sp, lr} │ │ │ │ - andsvs r6, sl, sl, lsr r8 │ │ │ │ - ldmdavs sl!, {r0, r1, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ - @ instruction: 0x461a009b │ │ │ │ - orrcs r2, r7, r0, lsl #6 │ │ │ │ - ldrbtmi r4, [r8], #-2059 @ 0xfffff7f5 │ │ │ │ - mrc2 7, 6, pc, cr12, cr14, {7} │ │ │ │ - ldmvs fp!, {r1, r9, sl, lr} │ │ │ │ - ldmvs fp!, {r1, r3, r4, r7, sp, lr} │ │ │ │ - ldmdavs fp!, {r3, r4, r7, fp, sp, lr}^ │ │ │ │ - @ instruction: 0x461a009b │ │ │ │ - @ instruction: 0xf7ee2100 │ │ │ │ - ldmvs fp!, {r5, r9, fp, sp, lr, pc} │ │ │ │ - @ instruction: 0x37104618 │ │ │ │ - stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - @ instruction: 0xffffff63 │ │ │ │ - muleq r3, lr, sl │ │ │ │ - andeq sl, r3, lr, ror sl │ │ │ │ - addlt fp, r2, r0, lsl #11 │ │ │ │ - rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r6, r7, r8, r9, sl, ip} │ │ │ │ - ldmdavs fp!, {r1, r3, r4, r6, lr}^ │ │ │ │ - @ instruction: 0x4619685b │ │ │ │ - @ instruction: 0xf0344610 │ │ │ │ - strmi pc, [fp], -r1, ror #22 │ │ │ │ - smladcc r8, r8, r6, r4 │ │ │ │ - stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - addlt fp, r7, r0, lsl #9 │ │ │ │ - rscsvs sl, r8, r0, lsl #30 │ │ │ │ - ldrhtvs r6, [sl], #-9 │ │ │ │ - ldmvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ - addseq r6, fp, fp, ror r8 │ │ │ │ - ldmdavs fp, {r0, r1, r4, sl, lr} │ │ │ │ - and r6, r9, fp, ror r1 │ │ │ │ - ldmdavs fp, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ - addsmi r6, sl, #12189696 @ 0xba0000 │ │ │ │ - ldmdbvs fp!, {r0, r8, ip, lr, pc}^ │ │ │ │ - ldmdbvs fp!, {r1, r2, sp, lr, pc}^ │ │ │ │ - cmnvs fp, fp, lsl r8 │ │ │ │ - blcs 2f2a8 │ │ │ │ - movwcs sp, #498 @ 0x1f2 │ │ │ │ - @ instruction: 0x371c4618 │ │ │ │ - @ instruction: 0xf85d46bd │ │ │ │ - ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ - addlt fp, r6, r0, lsl #11 │ │ │ │ - rscsvs sl, r8, r0, lsl #30 │ │ │ │ - ldrhtvs r6, [sl], #-9 │ │ │ │ - ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ - @ instruction: 0xffc0f7ff │ │ │ │ - ldmdbvs sl!, {r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ - ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ - @ instruction: 0xffcef7ff │ │ │ │ - ldmdbvs fp!, {r3, r4, r5, r8, sp, lr} │ │ │ │ - andle r2, ip, r0, lsl #22 │ │ │ │ - ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ - tstle r4, r0, lsl #22 │ │ │ │ - ldmvs fp, {r0, r1, r3, r4, r5, r8, fp, sp, lr} │ │ │ │ - @ instruction: 0xf7fe4618 │ │ │ │ - ldmdbvs fp!, {r0, r1, r5, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - addsvs r6, sl, sl, ror r8 │ │ │ │ - movwcs lr, #28 │ │ │ │ - @ instruction: 0x21bb220c │ │ │ │ - ldrbtmi r4, [r8], #-2062 @ 0xfffff7f2 │ │ │ │ - mcr2 7, 3, pc, cr8, cr14, {7} @ │ │ │ │ - ldmvs fp!, {r3, r4, r5, r8, sp, lr}^ │ │ │ │ - ldmdbvs fp!, {r1, r3, r4, r7, fp, sp, lr}^ │ │ │ │ - ldrmi r0, [r3], #-155 @ 0xffffff65 │ │ │ │ - ldmdbvs fp!, {r1, r3, r4, fp, sp, lr} │ │ │ │ - ldmdbvs fp!, {r1, r3, r4, sp, lr} │ │ │ │ - ldrhvs r6, [sl], #-138 @ 0xffffff76 │ │ │ │ - ldmdavs sl!, {r0, r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ - ldmvs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ - ldmdbvs fp!, {r1, r3, r4, r7, fp, sp, lr}^ │ │ │ │ - ldrmi r0, [r3], #-155 @ 0xffffff65 │ │ │ │ - andsvs r6, sl, sl, lsr r9 │ │ │ │ - ssatmi r3, #30, r8, lsl #14 │ │ │ │ - svclt 0x0000bd80 │ │ │ │ - muleq r3, r6, r9 │ │ │ │ - addlt fp, r4, r0, lsl #11 │ │ │ │ - rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - ldmdavs r9!, {r0, r3, r4, r5, sp, lr} │ │ │ │ - @ instruction: 0xf7ff6878 │ │ │ │ - @ instruction: 0x4603ff7d │ │ │ │ - ldmdavs r9!, {r1, r3, r4, r9, sl, lr} │ │ │ │ - @ instruction: 0xf7ff6878 │ │ │ │ - rscsvs pc, r8, fp, lsl #31 │ │ │ │ - blcs 2f164 │ │ │ │ - movwcs sp, #257 @ 0x101 │ │ │ │ - ldmvs fp!, {r0, sp, lr, pc}^ │ │ │ │ - @ instruction: 0x4618689b │ │ │ │ - ssatmi r3, #30, r0, lsl #14 │ │ │ │ - strlt fp, [r0], #3456 @ 0xd80 │ │ │ │ - svcge 0x0000b08d │ │ │ │ - movwcs r6, #120 @ 0x78 │ │ │ │ - movwcs r6, #635 @ 0x27b │ │ │ │ - @ instruction: 0xf04f623b │ │ │ │ - @ instruction: 0xf04f0200 │ │ │ │ - stmib r7, {r8, r9}^ │ │ │ │ - movwcs r2, #772 @ 0x304 │ │ │ │ - ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ - blcc 6ef1c <__bss_start@@Base+0x13e7c> │ │ │ │ - ldrsht r6, [r2], -fp │ │ │ │ - ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - @ instruction: 0x009b6afb │ │ │ │ - ldmdavs fp, {r0, r1, r4, sl, lr} │ │ │ │ - ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ - andle r2, r2, r0, lsl #22 │ │ │ │ - movwcc r6, #6651 @ 0x19fb │ │ │ │ - movwcs r6, #507 @ 0x1fb │ │ │ │ - @ instruction: 0xe00562bb │ │ │ │ - movwcc r6, #6843 @ 0x1abb │ │ │ │ - ldmvs fp!, {r0, r1, r3, r4, r5, r7, r9, sp, lr}^ │ │ │ │ - rscsvs r6, fp, fp, lsl r8 │ │ │ │ - blcs 2f1d0 │ │ │ │ - bvs feec95c0 <__bss_end__@@Base+0xfee22988> │ │ │ │ - addsmi r6, sl, #503808 @ 0x7b000 │ │ │ │ - bvs fef0c1f4 <__bss_end__@@Base+0xfee655bc> │ │ │ │ - bvs ead7e0 <__bss_end__@@Base+0xe06ba8> │ │ │ │ - ldrmi r6, [r3], #-2747 @ 0xfffff545 │ │ │ │ - bvs feeed6e8 <__bss_end__@@Base+0xfee46ab0> │ │ │ │ - vqrdmulh.s d15, d3, d3 │ │ │ │ - bcc fe450620 <__bss_end__@@Base+0xfe3a99e8> │ │ │ │ - blvc ffa108e8 <__bss_end__@@Base+0xff969cb0> │ │ │ │ - blvs 150468 <__bss_end__@@Base+0xa9830> │ │ │ │ - blvc 2106e8 <__bss_end__@@Base+0x169ab0> │ │ │ │ - blvc 150430 <__bss_end__@@Base+0xa97f8> │ │ │ │ - blcc 6fa04 <__bss_start@@Base+0x14964> │ │ │ │ - bvs ffeeda08 <__bss_end__@@Base+0xffe46dd0> │ │ │ │ - ble ff25fa20 <__bss_end__@@Base+0xff1b8de8> │ │ │ │ - @ instruction: 0xee076a3b │ │ │ │ - @ instruction: 0xeeb83a90 │ │ │ │ - vldr d6, [r7, #924] @ 0x39c │ │ │ │ - vdiv.f64 d5, d5, d4 │ │ │ │ - vmov.f64 d7, #118 @ 0x3fb00000 1.375 │ │ │ │ - vadd.f64 d6, d7, d0 │ │ │ │ - vmov.f64 d7, #102 @ 0x3f300000 0.6875000 │ │ │ │ - vmul.f64 d6, d7, d0 │ │ │ │ - vmov.f64 d7, #6 @ 0x40300000 2.750 │ │ │ │ - ldrcc r0, [r4, -r7, asr #22]! │ │ │ │ - @ instruction: 0xf85d46bd │ │ │ │ - ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ - addslt fp, r2, r0, lsl #11 │ │ │ │ - rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - ldmdavs r9!, {r0, r3, r4, r5, sp, lr} │ │ │ │ - ldrbtmi r4, [fp], #-2901 @ 0xfffff4ab │ │ │ │ - @ instruction: 0xf7ee4618 │ │ │ │ - movwcs lr, #2614 @ 0xa36 │ │ │ │ - movwcs r6, #1019 @ 0x3fb │ │ │ │ - @ instruction: 0xf04f63bb │ │ │ │ - @ instruction: 0xf04f0200 │ │ │ │ - stmib r7, {r8, r9}^ │ │ │ │ - movwcs r2, #778 @ 0x30a │ │ │ │ - ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r8, r9, sp, lr}^ │ │ │ │ - blcc 6eff0 <__bss_start@@Base+0x13f50> │ │ │ │ - eors r6, r2, fp, ror r4 │ │ │ │ - ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - addseq r6, fp, fp, ror ip │ │ │ │ - ldmdavs fp, {r0, r1, r4, sl, lr} │ │ │ │ - bvs 1eed884 <__bss_end__@@Base+0x1e46c4c> │ │ │ │ - andle r2, r2, r0, lsl #22 │ │ │ │ - movwcc r6, #7035 @ 0x1b7b │ │ │ │ - movwcs r6, #891 @ 0x37b │ │ │ │ - and r6, r5, fp, lsr r4 │ │ │ │ - movwcc r6, #7227 @ 0x1c3b │ │ │ │ - bvs 1eedf9c <__bss_end__@@Base+0x1e47364> │ │ │ │ - rsbsvs r6, fp, #1769472 @ 0x1b0000 │ │ │ │ - blcs 2f8a4 │ │ │ │ - ldcvs 1, cr13, [sl], #-984 @ 0xfffffc28 │ │ │ │ - addsmi r6, sl, #257024 @ 0x3ec00 │ │ │ │ - ldcvs 13, cr13, [fp], #-4 │ │ │ │ - blvs feeadeb4 <__bss_end__@@Base+0xfee0727c> │ │ │ │ - ldrmi r6, [r3], #-3131 @ 0xfffff3c5 │ │ │ │ - ldcvs 3, cr6, [fp], #-748 @ 0xfffffd14 │ │ │ │ - vqrdmulh.s d15, d3, d3 │ │ │ │ - bcc fe4506f4 <__bss_end__@@Base+0xfe3a9abc> │ │ │ │ - blvc ffa109bc <__bss_end__@@Base+0xff969d84> │ │ │ │ - blvs 2d053c <__bss_end__@@Base+0x229904> │ │ │ │ - blvc 2107bc <__bss_end__@@Base+0x169b84> │ │ │ │ - blvc 2d0504 <__bss_end__@@Base+0x2298cc> │ │ │ │ - blcc 700d8 <__bss_start@@Base+0x15038> │ │ │ │ - ldclvs 4, cr6, [fp], #-492 @ 0xfffffe14 │ │ │ │ - ble ff25faf4 <__bss_end__@@Base+0xff1b8ebc> │ │ │ │ - vmov.16 d23[0], r6 │ │ │ │ - @ instruction: 0xeeb83a90 │ │ │ │ - blvs 1eebe9c <__bss_end__@@Base+0x1e45264> │ │ │ │ - bcc fe450720 <__bss_end__@@Base+0xfe3a9ae8> │ │ │ │ - blvs ffa109e8 <__bss_end__@@Base+0xff969db0> │ │ │ │ - blvc 1d0920 <__bss_end__@@Base+0x129ce8> │ │ │ │ - blvc 1d052c <__bss_end__@@Base+0x1298f4> │ │ │ │ - vmov.16 d7[1], r6 │ │ │ │ - @ instruction: 0xeeb83a90 │ │ │ │ - vldr d7, [r7, #924] @ 0x39c │ │ │ │ - vdiv.f64 d5, d5, d10 │ │ │ │ - vldr d6, [r7, #28] │ │ │ │ - vmul.f64 d7, d7, d6 │ │ │ │ - vadd.f64 d7, d6, d7 │ │ │ │ - vstr d7, [r7, #284] @ 0x11c │ │ │ │ - blvs feef3b44 <__bss_end__@@Base+0xfee4cf0c> │ │ │ │ - bcc fe450754 <__bss_end__@@Base+0xfe3a9b1c> │ │ │ │ - blvs ffa10a1c <__bss_end__@@Base+0xff969de4> │ │ │ │ - blpl 2d059c <__bss_end__@@Base+0x229964> │ │ │ │ - blvc 1d0958 <__bss_end__@@Base+0x129d20> │ │ │ │ - blvs 50a24 │ │ │ │ - blvc 1d0828 <__bss_end__@@Base+0x129bf0> │ │ │ │ - blvs 50a28 │ │ │ │ - blvc 1d07f0 <__bss_end__@@Base+0x129bb8> │ │ │ │ - blvc d0574 <__bss_end__@@Base+0x2993c> │ │ │ │ - ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - blmi 5a67c4 <__bss_end__@@Base+0x4ffb8c> │ │ │ │ - @ instruction: 0x4618447b │ │ │ │ - ldmib r4!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blmi 52fd50 <__bss_end__@@Base+0x489118> │ │ │ │ - @ instruction: 0x4618447b │ │ │ │ - stmib lr!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blmi 4aff5c <__bss_end__@@Base+0x409324> │ │ │ │ - @ instruction: 0x4618447b │ │ │ │ - stmib r8!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - movwcs lr, #27095 @ 0x69d7 │ │ │ │ - ldrbtmi r4, [r9], #-2319 @ 0xfffff6f1 │ │ │ │ - @ instruction: 0xf7ee4608 │ │ │ │ - ldmib r7, {r1, r5, r7, r8, fp, sp, lr, pc}^ │ │ │ │ - stmdbmi sp, {r2, r8, r9, sp} │ │ │ │ - @ instruction: 0x46084479 │ │ │ │ - ldmib sl, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - movwcs lr, #10711 @ 0x29d7 │ │ │ │ - ldrbtmi r4, [r9], #-2314 @ 0xfffff6f6 │ │ │ │ - @ instruction: 0xf7ee4608 │ │ │ │ - svclt 0x0000e994 │ │ │ │ - ldrtmi r3, [sp], r8, asr #14 │ │ │ │ - svclt 0x0000bd80 │ │ │ │ - andeq sl, r3, lr, asr r8 │ │ │ │ - andeq sl, r3, ip, ror r7 │ │ │ │ - andeq sl, r3, ip, lsl #15 │ │ │ │ - andeq sl, r3, r0, lsr #15 │ │ │ │ - @ instruction: 0x0003a7b2 │ │ │ │ - andeq sl, r3, r8, asr #15 │ │ │ │ - ldrdeq sl, [r3], -lr │ │ │ │ + ldrblt fp, [r8, #840]! @ 0x348 │ │ │ │ + stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ + @ instruction: 0x0c0cebad │ │ │ │ + svceq 0x00e8f8cc │ │ │ │ + ldmib r0, {r1, r2, r9, sl, lr}^ │ │ │ │ + svccc 0x00017001 │ │ │ │ + @ instruction: 0xf850d419 │ │ │ │ + ldmdblt r4!, {r0, r1, r2, r5, lr} │ │ │ │ + stmdavs r5!, {r0, r1, r4, sp, lr, pc} │ │ │ │ + @ instruction: 0xf7fe4620 │ │ │ │ + @ instruction: 0x462cffdb │ │ │ │ + ldmdavs r3!, {r0, r2, r5, r6, r8, ip, sp, pc} │ │ │ │ + mvnsle r2, r0, lsl #22 │ │ │ │ + @ instruction: 0xf7fe68a0 │ │ │ │ + stmdavs r5!, {r0, r1, r4, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + @ instruction: 0xf7fe4620 │ │ │ │ + strtmi pc, [ip], -pc, asr #31 │ │ │ │ + mvnsle r2, r0, lsl #26 │ │ │ │ + svccc 0x000168b0 │ │ │ │ + pop {r0, r2, r5, r6, r7, r9, ip, lr, pc} │ │ │ │ + @ instruction: 0xf7fe40f8 │ │ │ │ + ldrbmi fp, [r0, -r5, asr #31]! │ │ │ │ + mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ + stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ + @ instruction: 0x0c0cebad │ │ │ │ + svceq 0x00e0f8cc │ │ │ │ + stmdacs r3, {r0, r1, r2, r3, r9, sl, lr} │ │ │ │ + strcs sp, [r3], #-3361 @ 0xfffff2df │ │ │ │ + strcc r0, [r1], #-100 @ 0xffffff9c │ │ │ │ + ldclle 2, cr4, [fp], #640 @ 0x280 │ │ │ │ + stmeq r4, {r0, r1, r2, r3, r6, r9, fp, sp, lr, pc} │ │ │ │ + cdpmi 6, 0, cr4, cr15, cr1, {6} │ │ │ │ + blmi 3dd4f8 <__bss_end__@@Base+0x336958> │ │ │ │ + ldrbtmi r2, [lr], #-388 @ 0xfffffe7c │ │ │ │ + @ instruction: 0x4630447b │ │ │ │ + mrc2 7, 7, pc, cr8, cr14, {7} │ │ │ │ + andvs r4, r7, r5, lsl #12 │ │ │ │ + movwcs r4, #1610 @ 0x64a │ │ │ │ + orrcs r4, r7, r0, lsr r6 │ │ │ │ + @ instruction: 0xf7fe606c │ │ │ │ + strbmi pc, [r2], -pc, ror #29 @ │ │ │ │ + adcvs r2, r8, r0, lsl #2 │ │ │ │ + stmib r6!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + pop {r3, r5, r9, sl, lr} │ │ │ │ + @ instruction: 0xf04f83f8 │ │ │ │ + strcs r0, [r3], #-2316 @ 0xfffff6f4 │ │ │ │ + strb r4, [r0, r8, asr #13]! │ │ │ │ + andeq r5, r3, r6, lsr r4 │ │ │ │ + @ instruction: 0xffffff75 │ │ │ │ + mvnsmi lr, sp, lsr #18 │ │ │ │ + stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ + @ instruction: 0x0c0cebad │ │ │ │ + svceq 0x00e8f8cc │ │ │ │ + strmi r4, [sp], -r6, lsl #12 │ │ │ │ + rscvc lr, r1, r1, lsl #21 │ │ │ │ + ldmdavs r1!, {r4, r7, r9, sl, lr}^ │ │ │ │ + blx ff450df8 <__bss_end__@@Base+0xff3aa258> │ │ │ │ + @ instruction: 0x460f68b3 │ │ │ │ + eormi pc, r1, r3, asr r8 @ │ │ │ │ + and fp, lr, r4, lsl r9 │ │ │ │ + cmnlt r4, r4, lsr #16 │ │ │ │ + addsmi r6, sp, #6488064 @ 0x630000 │ │ │ │ + ldmdavs r3!, {r1, r3, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ + @ instruction: 0xf8c4b11b │ │ │ │ + pop {r3, pc} │ │ │ │ + stmiavs r0!, {r4, r5, r6, r7, r8, pc} │ │ │ │ + @ instruction: 0xff6af7fe │ │ │ │ + stmdami r9, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ + andcs r2, ip, #0, 6 │ │ │ │ + ldrbtmi r2, [r8], #-443 @ 0xfffffe45 │ │ │ │ + mrc2 7, 5, pc, cr2, cr14, {7} │ │ │ │ + @ instruction: 0xf85368b3 │ │ │ │ + stmib r0, {r0, r1, r2, r5, sp}^ │ │ │ │ + @ instruction: 0xf8c02500 │ │ │ │ + @ instruction: 0xf8438008 │ │ │ │ + pop {r0, r1, r2, r5} │ │ │ │ + svclt 0x000081f0 │ │ │ │ + andeq r5, r3, r6, lsr #7 │ │ │ │ + vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ + bl feb6bf84 <__bss_end__@@Base+0xfeac53e4> │ │ │ │ + @ instruction: 0xf8cc0c0c │ │ │ │ + @ instruction: 0x46050ff0 │ │ │ │ + b fe0665c0 <__bss_end__@@Base+0xfdfbfa20> │ │ │ │ + stmdavs r9!, {r0, r5, r6, r7, ip, sp, lr}^ │ │ │ │ + blx fe650e68 <__bss_end__@@Base+0xfe5aa2c8> │ │ │ │ + @ instruction: 0xf85368ab │ │ │ │ + ldmdblt r0, {r0, r5} │ │ │ │ + stmdavs r0, {r0, r2, sp, lr, pc} │ │ │ │ + stmdavs r3, {r3, r4, r8, ip, sp, pc}^ │ │ │ │ + @ instruction: 0xd1fa429c │ │ │ │ + ldclt 8, cr6, [r8, #-512]! @ 0xfffffe00 │ │ │ │ + ldrlt r6, [r0], #-2113 @ 0xfffff7bf │ │ │ │ + @ instruction: 0xdd2e2900 │ │ │ │ + blvs 6d0438 <__bss_end__@@Base+0x629898> │ │ │ │ + andcs r6, r0, r4, lsl #17 │ │ │ │ + blpl 11d0884 <__bss_end__@@Base+0x1129ce4> │ │ │ │ + orreq lr, r1, r4, lsl #22 │ │ │ │ + stccc 8, cr15, [r4, #-324] @ 0xfffffebc │ │ │ │ + andcs fp, r0, #201326592 @ 0xc000000 │ │ │ │ + andcc r6, r1, #1769472 @ 0x1b0000 │ │ │ │ + mvnsle r2, r0, lsl #22 │ │ │ │ + vqrdmulh.s d15, d2, d2 │ │ │ │ + mcr 4, 0, r4, cr7, cr0, {0} │ │ │ │ + @ instruction: 0xeeb83a10 │ │ │ │ + vsub.f64 d7, d22, d7 │ │ │ │ + addmi r6, ip, #7168 @ 0x1c00 │ │ │ │ + cdp 1, 0, cr13, cr7, cr12, {7} │ │ │ │ + @ instruction: 0xeeb80a90 │ │ │ │ + @ instruction: 0xee867be7 │ │ │ │ + vmov.f64 d5, #119 @ 0x3fb80000 1.4375000 │ │ │ │ + vmov.f64 d7, #96 @ 0x3f000000 0.5 │ │ │ │ + @ instruction: 0xf85d0b00 │ │ │ │ + vadd.f64 d4, d5, d4 │ │ │ │ + vmul.f64 d7, d7, d7 │ │ │ │ + ldrbmi r0, [r0, -r0, lsl #22]! │ │ │ │ + blvc 11908d4 <__bss_end__@@Base+0x10e9d34> │ │ │ │ + ldc 7, cr14, [pc, #924] @ 151b4 │ │ │ │ + vmov.f64 d7, #3 @ 0x40180000 2.375 │ │ │ │ + strb r6, [sl, r7, asr #22]! │ │ │ │ + andhi pc, r0, pc, lsr #7 │ │ │ │ + ... │ │ │ │ + vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ + stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ + bl feb77a58 <__bss_end__@@Base+0xfead0eb8> │ │ │ │ + @ instruction: 0xf8cc0c0c │ │ │ │ + @ instruction: 0x460a0fd0 │ │ │ │ + ldmdbmi lr!, {r2, r9, sl, lr} │ │ │ │ + ldrbtmi r2, [r9], #-1 │ │ │ │ + ldm r4!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bcs 2efd8 │ │ │ │ + ldc 13, cr13, [pc, #412] @ 14ff0 │ │ │ │ + strcs r8, [r0, #-2872] @ 0xfffff4c8 │ │ │ │ + strtmi r6, [ip], r6, lsr #17 │ │ │ │ + cdp 6, 11, cr4, cr0, cr12, {1} │ │ │ │ + bl 1afb84 <__bss_end__@@Base+0x108fe4> │ │ │ │ + @ instruction: 0xf8500082 │ │ │ │ + blcs 2427c │ │ │ │ + strcc sp, [r1, #-85] @ 0xffffffab │ │ │ │ + ldmdavs fp, {r8, sp} │ │ │ │ + blcs 2127c │ │ │ │ + blx 8966a <__bss_start@@Base+0x2e662> │ │ │ │ + strmi pc, [ip], #769 @ 0x301 │ │ │ │ + bcc fe4506a0 <__bss_end__@@Base+0xfe3a9b00> │ │ │ │ + blvc ffa10968 <__bss_end__@@Base+0xff969dc8> │ │ │ │ + cdp 2, 3, cr4, cr8, cr12, {4} │ │ │ │ + svclt 0x00b88b07 │ │ │ │ + addmi r4, r6, #12, 12 @ 0xc00000 │ │ │ │ + cdp 1, 0, cr13, cr7, cr7, {7} │ │ │ │ + @ instruction: 0xeeb8ca90 │ │ │ │ + vmls.f64 d9, d23, d23 │ │ │ │ + @ instruction: 0xeeb85a90 │ │ │ │ + @ instruction: 0xee89bbe7 │ │ │ │ + stmdbmi r5!, {r0, r1, r3, r8, r9, fp, sp, pc} │ │ │ │ + ldrbtmi r2, [r9], #-1 │ │ │ │ + stm r0, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + strtmi r4, [sl], -r3, lsr #18 │ │ │ │ + ldrbtmi r2, [r9], #-1 │ │ │ │ + ldmda sl!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + strtmi r4, [r2], -r1, lsr #18 │ │ │ │ + ldrbtmi r2, [r9], #-1 │ │ │ │ + ldmda r4!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + andcs r4, r1, pc, lsl r9 │ │ │ │ + mrrc 4, 7, r4, r3, cr9 │ │ │ │ + @ instruction: 0xf7ee2b1a │ │ │ │ + ldmdbmi sp, {r1, r2, r3, r5, r6, fp, sp, lr, pc} │ │ │ │ + blvc 310900 <__bss_end__@@Base+0x269d60> │ │ │ │ + ldrbtmi r2, [r9], #-1 │ │ │ │ + blvc 12d0710 <__bss_end__@@Base+0x1229b70> │ │ │ │ + blcs 610038 <__bss_end__@@Base+0x569498> │ │ │ │ + stmda r2!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blpl 509d0 │ │ │ │ + blvc 290918 <__bss_end__@@Base+0x1e9d78> │ │ │ │ + blvs 509d4 │ │ │ │ + blhi 2501f4 <__bss_end__@@Base+0x1a9654> │ │ │ │ + ldmdbmi r4, {r0, sp} │ │ │ │ + pop {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ + mrc 0, 1, r4, cr7, cr0, {3} │ │ │ │ + vmul.f64 d7, d7, d5 │ │ │ │ + mrrc 11, 0, r7, r3, cr6 │ │ │ │ + @ instruction: 0xf7ee2b17 │ │ │ │ + cdp 8, 11, cr11, cr0, cr11, {2} │ │ │ │ + ldrmi r7, [r9], -r6, asr #22 │ │ │ │ + ldc 7, cr14, [pc, #712] @ 151ec │ │ │ │ + strcs fp, [r0, #-2820] @ 0xfffff4fc │ │ │ │ + cdp 6, 11, cr4, cr0, cr12, {1} │ │ │ │ + vmov.f64 d9, d11 │ │ │ │ + ldr r8, [r8, fp, asr #22]! │ │ │ │ + ... │ │ │ │ + ldrdeq r5, [r3], -r2 │ │ │ │ + andeq r5, r3, sl, lsl #5 │ │ │ │ + muleq r3, sl, r2 │ │ │ │ + andeq r5, r3, lr, lsr #5 │ │ │ │ + andeq r5, r3, r4, asr #5 │ │ │ │ + ldrdeq r5, [r3], -r6 │ │ │ │ + ldrdeq r5, [r3], -r8 │ │ │ │ andeq r0, r0, r0 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ - blmi 540bdc <__bss_end__@@Base+0x499fa4> │ │ │ │ + blmi 540b64 <__bss_end__@@Base+0x499fc4> │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ tstmi r3, #0, 6 │ │ │ │ ldmdbmi r2, {r1, r2, r8, ip, lr, pc} │ │ │ │ movwge r4, #58489 @ 0xe479 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ andscs r2, r8, #0, 6 │ │ │ │ stmdami lr, {r0, r3, r5, r8, sp} │ │ │ │ @ instruction: 0xf7fe4478 │ │ │ │ - ldrshtvs pc, [r8], #-197 @ 0xffffff3b @ │ │ │ │ + @ instruction: 0x6078fd9d │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs r9!, {r1, r3, r4, sp, lr}^ │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #18881 @ 0x49c1 │ │ │ │ @ instruction: 0x4618687b │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - blcc fe6c7828 <__bss_end__@@Base+0xfe620bf0> │ │ │ │ + blcc fe6c77b0 <__bss_end__@@Base+0xfe620c10> │ │ │ │ andeq r0, r0, r0 │ │ │ │ - andeq r7, r4, r4, lsr #19 │ │ │ │ - muleq r4, r8, r9 │ │ │ │ - @ instruction: 0x0003a7b0 │ │ │ │ + andeq r7, r4, r4, lsl #19 │ │ │ │ + andeq r7, r4, r8, ror r9 │ │ │ │ + andeq sl, r3, r8, lsl r7 │ │ │ │ svcmi 0x00b0e92d │ │ │ │ svcge 0x0000b084 │ │ │ │ @ instruction: 0x4619463b │ │ │ │ @ instruction: 0xf7ee2001 │ │ │ │ - ldmib r7, {r2, r3, r8, fp, sp, lr, pc}^ │ │ │ │ + ldmib r7, {r2, r5, r8, fp, sp, lr, pc}^ │ │ │ │ vst2.8 {d18-d21}, [pc], r0 │ │ │ │ @ instruction: 0xf6c3414a │ │ │ │ - blx 616c2 <__bss_start@@Base+0x6622> │ │ │ │ + blx 6164a <__bss_start@@Base+0x6642> │ │ │ │ tstpcs r0, r3 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf101fb02 │ │ │ │ vst3.8 {d20-d22}, [pc], r8 │ │ │ │ @ instruction: 0xf6c3414a │ │ │ │ - blx fe8a16d6 <__bss_end__@@Base+0xfe7faa9e> │ │ │ │ + blx fe8a165e <__bss_end__@@Base+0xfe7faabe> │ │ │ │ stmdbne r3, {r0, r8, sl, lr}^ │ │ │ │ ldmvs fp!, {r0, r2, r3, r4, r9, sl, lr} │ │ │ │ @ instruction: 0x469817da │ │ │ │ - bl 526ac0 <__bss_end__@@Base+0x47fe88> │ │ │ │ - bl 11578a0 <__bss_end__@@Base+0x10b0c68> │ │ │ │ + bl 526a48 <__bss_end__@@Base+0x47fea8> │ │ │ │ + bl 1157828 <__bss_end__@@Base+0x10b0c88> │ │ │ │ ldrbmi r0, [r2], -r9, lsl #22 │ │ │ │ @ instruction: 0x4610465b │ │ │ │ @ instruction: 0x37104619 │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ strlt r8, [r0, #4016] @ 0xfb0 │ │ │ │ svcge 0x0000b082 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ - blcs 2f10c │ │ │ │ + blcs 2f094 │ │ │ │ ldmdavs fp!, {r1, r3, r8, ip, lr, pc}^ │ │ │ │ andsvs r2, sl, r1, lsl #4 │ │ │ │ @ instruction: 0xffc6f7ff │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ stmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ and r2, r0, r2, lsl #6 │ │ │ │ strcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ movsmi lr, #737280 @ 0xb4000 │ │ │ │ svcge 0x0000b082 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ - blcs 2f13c │ │ │ │ + blcs 2f0c4 │ │ │ │ ldmdavs fp!, {r0, r2, r4, ip, lr, pc}^ │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ @ instruction: 0xffaef7ff │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - bne fe11dcec <__bss_end__@@Base+0xfe0770b4> │ │ │ │ + bne fe11dc74 <__bss_end__@@Base+0xfe0770d4> │ │ │ │ streq lr, [r3, #-2913] @ 0xfffff49f │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - bl 51dd00 <__bss_end__@@Base+0x4770c8> │ │ │ │ - bl 11570fc <__bss_end__@@Base+0x10b04c4> │ │ │ │ + bl 51dc88 <__bss_end__@@Base+0x4770e8> │ │ │ │ + bl 1157084 <__bss_end__@@Base+0x10b04e4> │ │ │ │ ldmdavs fp!, {r0, r1, r8, fp}^ │ │ │ │ stmdbhi r4, {r0, r1, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ svclt 0x0000e000 │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ movshi lr, #12386304 @ 0xbd0000 │ │ │ │ svcmi 0x00b0e92d │ │ │ │ svcge 0x0000b084 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ movwcs lr, #18899 @ 0x49d3 │ │ │ │ movwcs lr, #10695 @ 0x29c7 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ andle r2, pc, r0, lsl #22 │ │ │ │ @ instruction: 0xff88f7ff │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - bne fe11dd38 <__bss_end__@@Base+0xfe077100> │ │ │ │ + bne fe11dcc0 <__bss_end__@@Base+0xfe077120> │ │ │ │ streq lr, [r3, #-2913] @ 0xfffff49f │ │ │ │ movwcs lr, #10711 @ 0x29d7 │ │ │ │ - beq 14fd84 <__bss_end__@@Base+0xa914c> │ │ │ │ - bleq 18fe4c <__bss_end__@@Base+0xe9214> │ │ │ │ - blge cf860 <__bss_end__@@Base+0x28c28> │ │ │ │ + beq 14fd0c <__bss_end__@@Base+0xa916c> │ │ │ │ + bleq 18fdd4 <__bss_end__@@Base+0xe9234> │ │ │ │ + blge cf7e8 <__bss_end__@@Base+0x28c48> │ │ │ │ vst2. {d22-d23}, [pc :256], sl │ │ │ │ @ instruction: 0xf6c3434a │ │ │ │ - blx e1fba <__bss_end__@@Base+0x3b382> │ │ │ │ + blx e1f42 <__bss_end__@@Base+0x3b3a2> │ │ │ │ ldmvs fp!, {r1, r9, ip, sp, lr, pc} │ │ │ │ - blx 5d55a <__bss_start@@Base+0x24ba> │ │ │ │ + blx 5d4e2 <__bss_start@@Base+0x24da> │ │ │ │ ldrmi pc, [sl], #-771 @ 0xfffffcfd │ │ │ │ vst2.32 {d22-d23}, [pc :256], r9 │ │ │ │ @ instruction: 0xf6c3434a │ │ │ │ - blx fe861fd2 <__bss_end__@@Base+0xfe7bb39a> │ │ │ │ - bl b7578 <__bss_end__@@Base+0x10940> │ │ │ │ + blx fe861f5a <__bss_end__@@Base+0xfe7bb3ba> │ │ │ │ + bl b7500 <__bss_end__@@Base+0x10960> │ │ │ │ ldrmi r0, [r9], r9, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2823 @ 0xfffff4f9 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ strbmi r4, [r9], -r0, asr #12 │ │ │ │ - blx fead1250 <__bss_end__@@Base+0xfea2a618> │ │ │ │ + blx fead11d8 <__bss_end__@@Base+0xfea2a638> │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ @ instruction: 0x46194610 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svchi 0x00b0e8bd │ │ │ │ - andeq r7, r4, lr, lsl #16 │ │ │ │ + andeq r7, r4, lr, ror #15 │ │ │ │ @ instruction: 0xb082b5b0 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4602ffb3 │ │ │ │ @ instruction: 0xf512460b │ │ │ │ @ instruction: 0xf14374fa │ │ │ │ vst3.8 {d16,d18,d20}, [pc], r0 │ │ │ │ @@ -18161,15 +18156,15 @@ │ │ │ │ vaddw.s8 , q0, d16 │ │ │ │ ldmdane r4, {r0, r1, r2, r8}^ │ │ │ │ streq pc, [r0, #-323] @ 0xfffffebd │ │ │ │ subcs pc, r0, #68, 4 @ 0x40000004 │ │ │ │ andeq pc, pc, #192, 4 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ strtmi r4, [r9], -r0, lsr #12 │ │ │ │ - blx 1ad12d0 <__bss_end__@@Base+0x1a2a698> │ │ │ │ + blx 1ad1258 <__bss_end__@@Base+0x1a2a6b8> │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ movwcs lr, #10695 @ 0x29c7 │ │ │ │ movwcs lr, #10711 @ 0x29d7 │ │ │ │ svcmi 0x0000f1b2 │ │ │ │ movweq pc, #371 @ 0x173 @ │ │ │ │ ldmvs fp!, {r0, r9, fp, ip, lr, pc} │ │ │ │ @ instruction: 0xf06fe001 │ │ │ │ @@ -18180,151 +18175,151 @@ │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ @ instruction: 0xf04f6879 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r1, {r8, r9}^ │ │ │ │ svclt 0x00002304 │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 1533c0 <__bss_end__@@Base+0xac788> │ │ │ │ + blvc 153348 <__bss_end__@@Base+0xac7a8> │ │ │ │ strlt r4, [r0, #1904] @ 0x770 │ │ │ │ svcge 0x0000b082 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ vstrle d2, [r8, #-0] │ │ │ │ vst2.16 {d22-d23}, [pc :256], fp │ │ │ │ - blx b1c4e <__bss_end__@@Base+0xb016> │ │ │ │ + blx b1bd6 <__bss_end__@@Base+0xb036> │ │ │ │ ldrmi pc, [r8], -r3, lsl #6 │ │ │ │ - svc 0x0056f7ed │ │ │ │ + svc 0x006cf7ed │ │ │ │ svclt 0x0000e000 │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - ble 21fe88 <__bss_end__@@Base+0x179250> │ │ │ │ + ble 21fe10 <__bss_end__@@Base+0x179270> │ │ │ │ ldrbtmi r4, [fp], #-2895 @ 0xfffff4b1 │ │ │ │ stmdbmi pc, {r3, r5, r6, r9, sp}^ @ │ │ │ │ stmdami pc, {r0, r3, r4, r5, r6, sl, lr}^ @ │ │ │ │ @ instruction: 0xf7ed4478 │ │ │ │ - ldmdavs fp!, {r1, r2, r3, r5, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ - blcs 2f50c │ │ │ │ - blmi 134bac4 <__bss_end__@@Base+0x12a4e8c> │ │ │ │ + ldmdavs fp!, {r2, r6, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + blcs 2f494 │ │ │ │ + blmi 134ba4c <__bss_end__@@Base+0x12a4eac> │ │ │ │ rsbcs r4, r9, #2063597568 @ 0x7b000000 │ │ │ │ ldrbtmi r4, [r9], #-2379 @ 0xfffff6b5 │ │ │ │ ldrbtmi r4, [r8], #-2123 @ 0xfffff7b5 │ │ │ │ - svc 0x0020f7ed │ │ │ │ + svc 0x0036f7ed │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ stcle 2, cr4, [r8, #-616] @ 0xfffffd98 │ │ │ │ ldrbtmi r4, [fp], #-2887 @ 0xfffff4b9 │ │ │ │ stmdbmi r7, {r1, r3, r5, r6, r9, sp}^ │ │ │ │ stmdami r7, {r0, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf7ed4478 │ │ │ │ - ldmdavs fp!, {r1, r4, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmdavs fp!, {r3, r5, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, fp, sp, lr}^ │ │ │ │ ldrmi r6, [sl], #-2203 @ 0xfffff765 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ mulle r8, sl, r2 │ │ │ │ ldrbtmi r4, [fp], #-2881 @ 0xfffff4bf │ │ │ │ stmdbmi r1, {r0, r1, r3, r5, r6, r9, sp}^ │ │ │ │ stmdami r1, {r0, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf7ed4478 │ │ │ │ - ldmdavs fp!, {r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ - blcs 2f868 │ │ │ │ + ldmdavs fp!, {r1, r2, r4, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + blcs 2f7f0 │ │ │ │ ldmdavs fp!, {r2, r4, r8, r9, fp, ip, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r9, fp, sp, lr}^ │ │ │ │ @ instruction: 0x4619695b │ │ │ │ - blx 5df6e <__bss_start@@Base+0x2ece> │ │ │ │ + blx 5def6 <__bss_start@@Base+0x2eee> │ │ │ │ ldrmi pc, [r3], #-771 @ 0xfffffcfd │ │ │ │ - blcs 2f480 │ │ │ │ - blmi e49738 <__bss_end__@@Base+0xda2b00> │ │ │ │ + blcs 2f408 │ │ │ │ + blmi e496c0 <__bss_end__@@Base+0xda2b20> │ │ │ │ rsbcs r4, ip, #2063597568 @ 0x7b000000 │ │ │ │ ldrbtmi r4, [r9], #-2359 @ 0xfffff6c9 │ │ │ │ ldrbtmi r4, [r8], #-2103 @ 0xfffff7c9 │ │ │ │ - cdp 7, 14, cr15, cr6, cr13, {7} │ │ │ │ + cdp 7, 15, cr15, cr12, cr13, {7} │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - blle 51ff30 <__bss_end__@@Base+0x4792f8> │ │ │ │ - bvs 16af520 <__bss_end__@@Base+0x16088e8> │ │ │ │ + blle 51feb8 <__bss_end__@@Base+0x479318> │ │ │ │ + bvs 16af4a8 <__bss_end__@@Base+0x1608908> │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ tstcs r8, #26214400 @ 0x1900000 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ ldmdavs fp, {r0, r1, r4, sl, lr}^ │ │ │ │ tstle r8, r0, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2862 @ 0xfffff4d2 │ │ │ │ stmdbmi lr!, {r0, r2, r3, r5, r6, r9, sp} │ │ │ │ stmdami lr!, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf7ed4478 │ │ │ │ - ldmdavs fp!, {r1, r2, r3, r6, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ - blcs 2facc │ │ │ │ + ldmdavs fp!, {r2, r5, r6, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + blcs 2fa54 │ │ │ │ ldmdavs fp!, {r2, r4, r8, r9, fp, ip, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r9, fp, sp, lr}^ │ │ │ │ @ instruction: 0x461969db │ │ │ │ - blx 5dfd2 <__bss_start@@Base+0x2f32> │ │ │ │ + blx 5df5a <__bss_start@@Base+0x2f52> │ │ │ │ ldrmi pc, [r3], #-771 @ 0xfffffcfd │ │ │ │ - blcs 2f4e4 │ │ │ │ - blmi 98939c <__bss_end__@@Base+0x8e2764> │ │ │ │ + blcs 2f46c │ │ │ │ + blmi 989324 <__bss_end__@@Base+0x8e2784> │ │ │ │ rsbcs r4, lr, #2063597568 @ 0x7b000000 │ │ │ │ ldrbtmi r4, [r9], #-2340 @ 0xfffff6dc │ │ │ │ ldrbtmi r4, [r8], #-2084 @ 0xfffff7dc │ │ │ │ - cdp 7, 11, cr15, cr4, cr13, {7} │ │ │ │ - bvs 6ef57c <__bss_end__@@Base+0x648944> │ │ │ │ - blle 51ff94 <__bss_end__@@Base+0x47935c> │ │ │ │ - bvs 16af584 <__bss_end__@@Base+0x160894c> │ │ │ │ - bvs 6ef588 <__bss_end__@@Base+0x648950> │ │ │ │ + cdp 7, 12, cr15, cr10, cr13, {7} │ │ │ │ + bvs 6ef504 <__bss_end__@@Base+0x648964> │ │ │ │ + blle 51ff1c <__bss_end__@@Base+0x47937c> │ │ │ │ + bvs 16af50c <__bss_end__@@Base+0x160896c> │ │ │ │ + bvs 6ef510 <__bss_end__@@Base+0x648970> │ │ │ │ tstcs r8, #26214400 @ 0x1900000 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ ldmdavs fp, {r0, r1, r4, sl, lr}^ │ │ │ │ andle r2, r8, r0, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2843 @ 0xfffff4e5 │ │ │ │ ldmdbmi fp, {r0, r1, r2, r3, r5, r6, r9, sp} │ │ │ │ ldmdami fp, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf7ed4478 │ │ │ │ - svclt 0x0000ee9c │ │ │ │ + svclt 0x0000eeb2 │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq sl, r3, r2, asr #17 │ │ │ │ - andeq sl, r3, r4, lsr #10 │ │ │ │ - andeq sl, r3, ip, lsr #10 │ │ │ │ - andeq sl, r3, r8, lsr #17 │ │ │ │ - andeq sl, r3, sl, lsl #10 │ │ │ │ - andeq sl, r3, sl, lsr #10 │ │ │ │ - andeq sl, r3, sl, lsl #17 │ │ │ │ - andeq sl, r3, ip, ror #9 │ │ │ │ - andeq sl, r3, r4, lsr #10 │ │ │ │ - andeq sl, r3, r6, ror #16 │ │ │ │ - andeq sl, r3, r8, asr #9 │ │ │ │ - andeq sl, r3, r4, lsr #10 │ │ │ │ - andeq sl, r3, r4, lsr r8 │ │ │ │ - muleq r3, r6, r4 │ │ │ │ - andeq sl, r3, sl, lsr #10 │ │ │ │ - andeq sl, r3, r2, lsl #16 │ │ │ │ - andeq sl, r3, r4, ror #8 │ │ │ │ - andeq sl, r3, r4, asr #10 │ │ │ │ - ldrdeq sl, [r3], -r0 │ │ │ │ - andeq sl, r3, r2, lsr r4 │ │ │ │ - andeq sl, r3, sl, asr r5 │ │ │ │ - muleq r3, lr, r7 │ │ │ │ - andeq sl, r3, r0, lsl #8 │ │ │ │ - andeq sl, r3, r4, ror r5 │ │ │ │ + andeq sl, r3, r6, lsr r8 │ │ │ │ + muleq r3, r8, r4 │ │ │ │ + andeq sl, r3, r0, lsr #9 │ │ │ │ + andeq sl, r3, ip, lsl r8 │ │ │ │ + andeq sl, r3, lr, ror r4 │ │ │ │ + muleq r3, lr, r4 │ │ │ │ + strdeq sl, [r3], -lr │ │ │ │ + andeq sl, r3, r0, ror #8 │ │ │ │ + muleq r3, r8, r4 │ │ │ │ + ldrdeq sl, [r3], -sl @ │ │ │ │ + andeq sl, r3, ip, lsr r4 │ │ │ │ + muleq r3, r8, r4 │ │ │ │ + andeq sl, r3, r8, lsr #15 │ │ │ │ + andeq sl, r3, sl, lsl #8 │ │ │ │ + muleq r3, lr, r4 │ │ │ │ + andeq sl, r3, r6, ror r7 │ │ │ │ + ldrdeq sl, [r3], -r8 │ │ │ │ + @ instruction: 0x0003a4b8 │ │ │ │ + andeq sl, r3, r4, asr #14 │ │ │ │ + andeq sl, r3, r6, lsr #7 │ │ │ │ + andeq sl, r3, lr, asr #9 │ │ │ │ + andeq sl, r3, r2, lsl r7 │ │ │ │ + andeq sl, r3, r4, ror r3 │ │ │ │ + andeq sl, r3, r8, ror #9 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ rscsvs r6, fp, fp, ror r8 │ │ │ │ - blcs 2f824 │ │ │ │ + blcs 2f7ac │ │ │ │ ldmvs r8!, {r3, ip, lr, pc}^ │ │ │ │ @ instruction: 0xff1cf7ff │ │ │ │ - bvs 16ef830 <__bss_end__@@Base+0x1648bf8> │ │ │ │ + bvs 16ef7b8 <__bss_end__@@Base+0x1648c18> │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ - and pc, r0, r1, lsl #23 │ │ │ │ + and pc, r0, r9, lsr #24 │ │ │ │ ldrcc fp, [r0, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ - blmi 6c105c <__bss_end__@@Base+0x61a424> │ │ │ │ + blmi 6c0fe4 <__bss_end__@@Base+0x61a444> │ │ │ │ eorcs r4, ip, #2063597568 @ 0x7b000000 │ │ │ │ ldmdami r9, {r0, r2, r3, r4, r5, r6, r8, sp} │ │ │ │ @ instruction: 0xf7fe4478 │ │ │ │ - rsbsvs pc, r8, r1, asr #21 │ │ │ │ + rsbsvs pc, r8, r9, ror #22 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ subsvs r2, sl, r0, lsl #4 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ sbcsvs r2, sl, r0, lsl #4 │ │ │ │ @ instruction: 0xf04f687b │ │ │ │ @@ -18340,143 +18335,143 @@ │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r9, sp, lr}^ │ │ │ │ addsvs r2, sl, #0, 4 │ │ │ │ @ instruction: 0x4618687b │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ @ instruction: 0xffffffc9 │ │ │ │ - andeq sl, r3, r0, asr r3 │ │ │ │ + andeq sl, r3, r4, asr #5 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x46184413 │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 15365c <__bss_end__@@Base+0xaca24> │ │ │ │ + blvc 1535e4 <__bss_end__@@Base+0xaca44> │ │ │ │ strlt r4, [r0], #1904 @ 0x770 │ │ │ │ svcge 0x0000b083 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ @ instruction: 0x4618685b │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 153674 <__bss_end__@@Base+0xaca3c> │ │ │ │ + blvc 1535fc <__bss_end__@@Base+0xaca5c> │ │ │ │ strlt r4, [r0], #1904 @ 0x770 │ │ │ │ svcge 0x0000b087 │ │ │ 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{r0, r1, r9, fp, ip, lr, pc}^ │ │ │ │ rscscc pc, pc, #79 @ 0x4f │ │ │ │ ldmdavs fp!, {r1, r3, r4, r9, sp, lr}^ │ │ │ │ - blcs 2fd00 │ │ │ │ + blcs 2fc88 │ │ │ │ ldmvs fp!, {r4, r9, fp, ip, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, r8, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, r8, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, r6, r8, sp, lr}^ │ │ │ │ rscscc pc, pc, #79 @ 0x4f │ │ │ │ ldmvs fp!, {r1, r3, r4, r8, sp, lr}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, r8, fp, sp, lr}^ │ │ │ │ ldrsb r6, [r7], -sl │ │ │ │ ldmibvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldrshvs r6, [sl], #139 @ 0x8b │ │ │ │ @ instruction: 0xf04f68fb │ │ │ │ @ instruction: 0x611a32ff │ │ │ │ - bvs 16af8b8 <__bss_end__@@Base+0x1608c80> │ │ │ │ + bvs 16af840 <__bss_end__@@Base+0x1608ca0> │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ tstcs r8, #26214400 @ 0x1900000 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ ldmvs sl!, {r0, r1, r4, sl, lr}^ │ │ │ │ tstvs sl, r2, lsl r8 │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ orrsvs r6, sl, fp, ror r8 │ │ │ │ @@ -18491,77 +18486,77 @@ │ │ │ │ @ instruction: 0xf7ff68f8 │ │ │ │ @ instruction: 0x4603fedf │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - blcs 2fe94 │ │ │ │ + blcs 2fe1c │ │ │ │ movwcs sp, #2825 @ 0xb09 │ │ │ │ ldrbtmi r4, [sl], #-2637 @ 0xfffff5b3 │ │ │ │ stmdami sp, {r5, r6, r7, r8, sp}^ │ │ │ │ @ instruction: 0xf7fd4478 │ │ │ │ - @ instruction: 0xf7edf877 │ │ │ │ - ldmdavs fp!, {r1, r2, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7edfc6b │ │ │ │ + ldmdavs fp!, {r1, r3, r4, sl, fp, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r7, fp, sp, lr}^ │ │ │ │ addsmi r6, sl, #1769472 @ 0x1b0000 │ │ │ │ ldmdavs fp!, {r1, r4, r5, r8, r9, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf5b3681b │ │ │ │ - blle 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@@ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, sl, fp, ip}^ │ │ │ │ ldmdavs r8!, {r1, r3, r4, r6, r7, sp, lr}^ │ │ │ │ ldc2 7, cr15, [r2, #-1020] @ 0xfffffc04 │ │ │ │ @ instruction: 0xf7ff68b8 │ │ │ │ @ instruction: 0x4603fe39 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq sl, r3, r2, lsl r3 │ │ │ │ - andeq sl, r3, r0, lsl #1 │ │ │ │ - andeq sl, r3, sl, lsr r3 │ │ │ │ - andeq sl, r3, r4, asr r0 │ │ │ │ - andeq sl, r3, r6, lsl r0 │ │ │ │ + andeq sl, r3, r6, lsl #5 │ │ │ │ + strdeq r9, [r3], -r4 │ │ │ │ + andeq sl, r3, lr, lsr #5 │ │ │ │ + andeq r9, r3, r8, asr #31 │ │ │ │ + andeq r9, r3, sl, lsl #31 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ mcr2 7, 3, pc, cr13, cr15, {7} @ │ │ │ │ ldmdbvs fp!, {r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ cmpvs sl, sl, ror r8 │ │ │ │ @@ -18600,67 +18595,67 @@ │ │ │ │ ldmdbvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ tstvs sl, fp, ror r8 │ │ │ │ andcs r6, r0, #16449536 @ 0xfb0000 │ │ │ │ ldmvs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ @ instruction: 0xf503689b │ │ │ │ ldmvs fp!, {r7, r9, ip, sp}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ - blcs 2fb48 │ │ │ │ + blcs 2fad0 │ │ │ │ ldmvs fp!, {r0, r1, r8, ip, lr, pc}^ │ │ │ │ addcc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ ldmvs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ - blcs 2fd58 │ │ │ │ + blcs 2fce0 │ │ │ │ ldmvs fp!, {r0, r2, r3, r4, r9, fp, ip, lr, pc}^ │ │ │ │ - blcs 2fc60 │ │ │ │ + blcs 2fbe8 │ │ │ │ ldmdavs fp!, {r3, r9, fp, ip, lr, pc}^ │ │ │ │ rscscc pc, pc, #79 @ 0x4f │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, r8, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, r8, fp, sp, lr}^ │ │ │ │ eors r6, sp, sl, asr r1 │ │ │ │ - bvs 16afaf8 <__bss_end__@@Base+0x1608ec0> │ │ │ │ + bvs 16afa80 <__bss_end__@@Base+0x1608ee0> │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ tstcs r8, #26214400 @ 0x1900000 │ │ │ │ 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r2, lsl r9 │ │ │ │ - bvs 16afb5c <__bss_end__@@Base+0x1608f24> │ │ │ │ + bvs 16afae4 <__bss_end__@@Base+0x1608f44> │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ tstcs r8, #26214400 @ 0x1900000 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ ldmvs sl!, {r0, r1, r4, sl, lr}^ │ │ │ │ ldrsbvs r6, [sl], #130 @ 0x82 │ │ │ │ - bvs 6efb74 <__bss_end__@@Base+0x648f3c> │ │ │ │ - ble 22058c <__bss_end__@@Base+0x179954> │ │ │ │ + bvs 6efafc <__bss_end__@@Base+0x648f5c> │ │ │ │ + ble 220514 <__bss_end__@@Base+0x179974> │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ andsvs r6, sl, #8060928 @ 0x7b0000 │ │ │ │ - bvs 6afb84 <__bss_end__@@Base+0x608f4c> │ │ │ │ + bvs 6afb0c <__bss_end__@@Base+0x608f6c> │ │ │ │ bicsvs r6, sl, fp, ror r8 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r3, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r9, fp, sp, lr}^ │ │ │ │ @ instruction: 0x46196a1b │ │ │ │ - blx 5e60e <__bss_start@@Base+0x356e> │ │ │ │ + blx 5e596 <__bss_start@@Base+0x358e> │ │ │ │ ldrmi pc, [r3], #-771 @ 0xfffffcfd │ │ │ │ ldmdavs r2, {r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldmvs fp!, {r1, r3, r4, r8, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, r9, sp, lr}^ │ │ │ │ rscscc pc, pc, #79 @ 0x4f │ │ │ │ ldmdavs fp!, {r1, r3, r4, r8, sp, lr}^ │ │ │ │ @@ -18670,141 +18665,141 @@ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, sl, fp, ip}^ │ │ │ │ ldmdavs r8!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ mcrr2 7, 15, pc, ip, cr15 @ │ │ │ │ ldrcc fp, [r0, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - bvs fe6efbe0 <__bss_end__@@Base+0xfe648fa8> │ │ │ │ + bvs fe6efb68 <__bss_end__@@Base+0xfe648fc8> │ │ │ │ andle r2, sl, r0, lsl #22 │ │ │ │ - bmi 59e5fc <__bss_end__@@Base+0x4f79c4> │ │ │ │ + bmi 59e584 <__bss_end__@@Base+0x4f79e4> │ │ │ │ vqshl.s8 q10, q13, q0 │ │ │ │ ldmdami r5, {r0, r1, r2, r4, r5, r8, ip} │ │ │ │ - @ instruction: 0xf7fc4478 │ │ │ │ - @ instruction: 0xf7edff0f │ │ │ │ - ldmdavs fp!, {r1, r2, r3, r4, r7, r9, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7fd4478 │ │ │ │ + @ instruction: 0xf7edfb03 │ │ │ │ + ldmdavs fp!, {r1, r4, r5, r7, r9, fp, sp, lr, pc}^ │ │ │ │ addsvs r2, sl, #268435456 @ 0x10000000 │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - ble 16061c <__bss_end__@@Base+0xb99e4> │ │ │ │ + ble 1605a4 <__bss_end__@@Base+0xb9a04> │ │ │ │ @ instruction: 0xf04f687b │ │ │ │ @ instruction: 0x611a32ff │ │ │ │ ands r2, r1, r0, lsl #6 │ │ │ │ - bvs 16afc18 <__bss_end__@@Base+0x1608fe0> │ │ │ │ + bvs 16afba0 <__bss_end__@@Base+0x1609000> │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ tstcs r8, #26214400 @ 0x1900000 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ rscsvs r4, fp, r3, lsl r4 │ │ │ │ ldmdbvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ tstvs sl, fp, ror r8 │ │ │ │ @ instruction: 0xf7ff68f8 │ │ │ │ strmi pc, [r3], -r1, asr #26 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq sl, r3, r8, lsr #1 │ │ │ │ - @ instruction: 0x00039db0 │ │ │ │ + andeq sl, r3, ip, lsl r0 │ │ │ │ + andeq r9, r3, r4, lsr #26 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - bvs fe6efc54 <__bss_end__@@Base+0xfe64901c> │ │ │ │ + bvs fe6efbdc <__bss_end__@@Base+0xfe64903c> │ │ │ │ tstle sl, r0, lsl #22 │ │ │ │ - bmi 4de670 <__bss_end__@@Base+0x437a38> │ │ │ │ + bmi 4de5f8 <__bss_end__@@Base+0x437a58> │ │ │ │ vqshl.s8 q10, q13, q0 │ │ │ │ ldmdami r2, {r0, r1, r2, r6, r8, ip} │ │ │ │ - @ instruction: 0xf7fc4478 │ │ │ │ - @ instruction: 0xf7edfed5 │ │ │ │ - ldmdavs fp!, {r2, r5, r6, r9, fp, sp, lr, pc}^ │ │ │ │ - blcs 2fef4 │ │ │ │ + @ instruction: 0xf7fd4478 │ │ │ │ + @ instruction: 0xf7edfac9 │ │ │ │ + ldmdavs fp!, {r3, r4, r5, r6, r9, fp, sp, lr, pc}^ │ │ │ │ + blcs 2fe7c │ │ │ │ movwcs sp, #2561 @ 0xa01 │ │ │ │ ldmdavs fp!, {r0, r4, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r9, fp, sp, lr}^ │ │ │ │ @ instruction: 0x4619691b │ │ │ │ - blx 5e6fe <__bss_start@@Base+0x365e> │ │ │ │ + blx 5e686 <__bss_start@@Base+0x367e> │ │ │ │ ldrmi pc, [r3], #-771 @ 0xfffffcfd │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r8, fp, sp, lr}^ │ │ │ │ ldmvs r8!, {r1, r3, r4, r8, sp, lr}^ │ │ │ │ stc2 7, cr15, [lr, #-1020] @ 0xfffffc04 │ │ │ │ ldrmi r4, [r8], -r3, lsl #12 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - muleq r3, r4, r0 │ │ │ │ - andeq r9, r3, ip, lsr sp │ │ │ │ + andeq sl, r3, r8 │ │ │ │ + @ instruction: 0x00039cb0 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - bvs fe6efcbc <__bss_end__@@Base+0xfe649084> │ │ │ │ + bvs fe6efc44 <__bss_end__@@Base+0xfe6490a4> │ │ │ │ tstle sl, r0, lsl #22 │ │ │ │ - bmi 21e6d8 <__bss_end__@@Base+0x177aa0> │ │ │ │ + bmi 21e660 <__bss_end__@@Base+0x177ac0> │ │ │ │ vqshl.s8 q10, q13, q0 │ │ │ │ stmdami r7, {r0, r2, r4, r6, r8, ip} │ │ │ │ - @ instruction: 0xf7fc4478 │ │ │ │ - @ instruction: 0xf7edfea1 │ │ │ │ - ldmdavs fp!, {r4, r5, r9, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7fd4478 │ │ │ │ + @ instruction: 0xf7edfa95 │ │ │ │ + ldmdavs fp!, {r2, r6, r9, fp, sp, lr, pc}^ │ │ │ │ addsvs r2, sl, #0, 4 │ │ │ │ strcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq sl, r3, r0, rrx │ │ │ │ ldrdeq r9, [r3], -r4 │ │ │ │ + andeq r9, r3, r8, asr #24 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ strmi sl, [r3], -r0, lsl #30 │ │ │ │ ldmhi fp!, {r0, r1, r3, r4, r5, r6, r7, pc}^ │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0x4618687b │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 153ca0 <__bss_end__@@Base+0xad068> │ │ │ │ + blvc 153c28 <__bss_end__@@Base+0xad088> │ │ │ │ strlt r4, [r0, #1904] @ 0x770 │ │ │ │ svcge 0x0000b084 │ │ │ │ ldrshtvs r6, [r9], r8 │ │ │ │ andcs r6, r1, #122 @ 0x7a │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - bl b53af8 <__bss_end__@@Base+0xaacec0> │ │ │ │ - blcs 27354 │ │ │ │ + bl 10d3a80 <__bss_end__@@Base+0x102cee0> │ │ │ │ + blcs 272dc │ │ │ │ ldmvs sl!, {r1, r2, ip, lr, pc}^ │ │ │ │ - blmi 12fd34 <__bss_end__@@Base+0x890fc> │ │ │ │ + blmi 12fcbc <__bss_end__@@Base+0x8911c> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - mcr2 7, 7, pc, cr4, cr12, {7} @ │ │ │ │ + blx ff653ad4 <__bss_end__@@Base+0xff5acf34> │ │ │ │ ldrcc fp, [r0, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq sl, r3, ip │ │ │ │ + andeq r9, r3, r0, lsl #31 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ - ble 260778 <__bss_end__@@Base+0x1b9b40> │ │ │ │ - bmi 62fd68 <__bss_end__@@Base+0x589130> │ │ │ │ + ble 260700 <__bss_end__@@Base+0x1b9b60> │ │ │ │ + bmi 62fcf0 <__bss_end__@@Base+0x589150> │ │ │ │ cmpcs sp, sl, ror r4 │ │ │ │ ldrbtmi r4, [r8], #-2071 @ 0xfffff7e9 │ │ │ │ - mrc2 7, 2, pc, cr0, cr12, {7} │ │ │ │ - ldmib lr, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - blcs 2fd7c │ │ │ │ + blx 1153b04 <__bss_end__@@Base+0x10acf64> │ │ │ │ + ldmib r2!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blcs 2fd04 │ │ │ │ ldmdavs r9!, {r1, r2, r3, r4, ip, lr, pc}^ │ │ │ │ andcs r6, r1, #12255232 @ 0xbb0000 │ │ │ │ @ instruction: 0xf7ed6838 │ │ │ │ - @ instruction: 0x4603ecba │ │ │ │ + strmi lr, [r3], -sl, asr #25 │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ andsle r2, r5, r1, lsl #22 │ │ │ │ @ instruction: 0xf7ed68b8 │ │ │ │ - strmi lr, [r3], -ip, ror #22 │ │ │ │ + strmi lr, [r3], -r4, lsl #23 │ │ │ │ andle r2, r6, r0, lsl #22 │ │ │ │ - blmi 2eff9c <__bss_end__@@Base+0x249364> │ │ │ │ + blmi 2eff24 <__bss_end__@@Base+0x249384> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - mrc2 7, 3, pc, cr14, cr12, {7} │ │ │ │ + blx 1cd3b3c <__bss_end__@@Base+0x1c2cf9c> │ │ │ │ ldmvs r9!, {r0, r3, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [fp], #-2824 @ 0xfffff4f8 │ │ │ │ - @ instruction: 0xf7fc4618 │ │ │ │ - and pc, r2, r7, ror lr @ │ │ │ │ + @ instruction: 0xf7fd4618 │ │ │ │ + and pc, r2, fp, ror #20 │ │ │ │ and fp, r0, r0, lsl #30 │ │ │ │ ldrcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq sl, r3, r4 │ │ │ │ - andeq sl, r3, r2, lsr #32 │ │ │ │ - strdeq r9, [r3], -r4 │ │ │ │ - andeq sl, r3, lr │ │ │ │ + andeq r9, r3, r8, ror pc │ │ │ │ + muleq r3, r6, pc @ │ │ │ │ + andeq r9, r3, r8, ror #30 │ │ │ │ + andeq r9, r3, r2, lsl #31 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xf1076039 │ │ │ │ andcs r0, r2, #939524096 @ 0x38000000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ @ instruction: 0xffb0f7ff │ │ │ │ @ instruction: 0x461889fb │ │ │ │ @@ -18823,300 +18818,300 @@ │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmvs fp!, {r3, r4, r5, r6, fp, sp, lr} │ │ │ │ tstcs r1, r4, lsl #4 │ │ │ │ - mrrc 7, 14, pc, ip, cr13 @ │ │ │ │ + stcl 7, cr15, [ip], #-948 @ 0xfffffc4c │ │ │ │ cmnvs fp, r3, lsl #12 │ │ │ │ - blcs f024c <__bss_end__@@Base+0x49614> │ │ │ │ + blcs f01d4 <__bss_end__@@Base+0x49634> │ │ │ │ ldmvs r8!, {r0, r1, r2, r4, sl, fp, ip, lr, pc} │ │ │ │ - bl 3d3c1c <__bss_end__@@Base+0x32cfe4> │ │ │ │ - blcs 27478 │ │ │ │ + bl 9d3ba4 <__bss_end__@@Base+0x92d004> │ │ │ │ + blcs 27400 │ │ │ │ ldmdbvs fp!, {r0, r1, r3, ip, lr, pc}^ │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, r7, r0, lsl #6 │ │ │ │ - blmi 370060 <__bss_end__@@Base+0x2c9428> │ │ │ │ + blmi 36ffe8 <__bss_end__@@Base+0x2c9448> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - mrc2 7, 0, pc, cr12, cr12, {7} │ │ │ │ + blx 453c00 <__bss_end__@@Base+0x3ad060> │ │ │ │ ldmvs r9!, {r0, r2, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [fp], 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│ + andeq r9, r3, r6, lsr #28 │ │ │ │ + andeq r9, r3, r4, lsl #29 │ │ │ │ + andeq r9, r3, r0, ror lr │ │ │ │ + andeq r9, r3, r8, ror #28 │ │ │ │ + andeq r9, r3, sl, ror lr │ │ │ │ + andeq r9, r3, lr, ror #28 │ │ │ │ + andeq r9, r3, r8, lsl #29 │ │ │ │ + muleq r3, r8, lr │ │ │ │ + andeq r9, r3, ip, lsl #29 │ │ │ │ + andeq r9, r3, ip, asr sp │ │ │ │ + andeq r9, r3, lr, ror lr │ │ │ │ + andeq r9, r3, ip, ror #28 │ │ │ │ + andeq r9, r3, lr, ror lr │ │ │ │ + andeq r9, r3, lr, asr #28 │ │ │ │ + andeq r9, r3, r4, lsr lr │ │ │ │ + andeq r9, r3, ip, lsl lr │ │ │ │ + andeq r9, r3, lr, lsr #28 │ │ │ │ + andeq r9, r3, r6, asr lr │ │ │ │ + andeq r9, r3, r2, ror #28 │ │ │ │ + andeq r9, r3, sl, ror lr │ │ │ │ + muleq r3, r6, lr │ │ │ │ + andeq r9, r3, r4, lsr #29 │ │ │ │ + muleq r3, ip, lr │ │ │ │ andeq r0, r0, r0 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xf003687b │ │ │ │ - blcs 16c70 │ │ │ │ + blcs 16bf8 │ │ │ │ ldmdavs sl!, {r1, r5, r8, ip, lr, pc}^ │ │ │ │ tstppl pc, #72, 4 @ p-variant is OBSOLETE @ 0x80000004 │ │ │ │ mvnne pc, #1342177292 @ 0x5000000c │ │ │ │ movwne pc, #11139 @ 0x2b83 @ │ │ │ │ @ instruction: 0x17d31159 │ │ │ │ cmncs r4, fp, asr #21 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ - blcs 1cbd0 │ │ │ │ + blcs 1cb58 │ │ │ │ ldmdavs sl!, {r4, r8, ip, lr, pc}^ │ │ │ │ tstppl pc, #72, 4 @ p-variant is OBSOLETE @ 0x80000004 │ │ │ │ mvnne pc, #1342177292 @ 0x5000000c │ │ │ │ movwne pc, #11139 @ 0x2b83 @ │ │ │ │ @ instruction: 0x17d311d9 │ │ │ │ vst1.64 {d17-d18}, [pc], fp │ │ │ │ - blx 727c2 <__bss_start@@Base+0x17722> │ │ │ │ - bne ff512cb0 <__bss_end__@@Base+0xff46c078> │ │ │ │ + blx 7274a <__bss_start@@Base+0x17742> │ │ │ │ + bne ff512c38 <__bss_end__@@Base+0xff46c098> │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, r0, r1, lsl #6 │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 15422c <__bss_end__@@Base+0xad5f4> │ │ │ │ + blvc 1541b4 <__bss_end__@@Base+0xad614> │ │ │ │ strlt r4, [r0, #1904] @ 0x770 │ │ │ │ svcge 0x0000b082 │ │ │ │ ldmdavs r8!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ @ instruction: 0xffc6f7ff │ │ │ │ - blcs 278d8 │ │ │ │ + blcs 27860 │ │ │ │ vst4.8 {d29-d32}, [pc], r4 │ │ │ │ vsubw.s8 q10, q0, d5 │ │ │ │ and r1, r3, r2, ror #7 │ │ │ │ movtpl pc, #58447 @ 0xe44f @ │ │ │ │ mvnne pc, #192, 4 │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @@ -19126,19 +19121,19 @@ │ │ │ │ ldrhvs r7, [fp, #50]! @ 0x32 │ │ │ │ ldmibvs fp!, {r0, r3, sp, lr, pc}^ │ │ │ │ mvnsvs r3, r1, lsl #22 │ │ │ │ @ instruction: 0xf7ff69f8 │ │ │ │ @ instruction: 0x4602ffda │ │ │ │ ldrmi r6, [r3], #-2171 @ 0xfffff785 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, sp, lr}^ │ │ │ │ - blle ffca0d14 <__bss_end__@@Base+0xffbfa0dc> │ │ │ │ + blle ffca0c9c <__bss_end__@@Base+0xffbfa0fc> │ │ │ │ @ instruction: 0xf7ff69f8 │ │ │ │ ldrsbvs pc, [r8, #-240]! @ 0xffffff10 @ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - blle 1e6b8c <__bss_end__@@Base+0x13ff54> │ │ │ │ + blle 1e6b14 <__bss_end__@@Base+0x13ff74> │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldrsbtvs r1, [fp], #-163 @ 0xffffff5d │ │ │ │ movwcc r6, #6651 @ 0x19fb │ │ │ │ @ instruction: 0xe7ef61fb │ │ │ │ ldmdavs fp!, {r8, r9, sl, fp, ip, sp, pc} │ │ │ │ @ instruction: 0x601a69fa │ │ │ │ @ instruction: 0x61bb2300 │ │ │ │ @@ -19154,496 +19149,496 @@ │ │ │ │ eorcs pc, r2, r3, asr r8 @ │ │ │ │ @ instruction: 0x43a3f44f │ │ │ │ movweq pc, #4800 @ 0x12c0 @ │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ addsmi r6, sl, #16449536 @ 0xfb0000 │ │ │ │ ldmdavs sl!, {r0, r1, r2, r8, r9, fp, ip, lr, pc}^ │ │ │ │ - bne ff4f0570 <__bss_end__@@Base+0xff449938> │ │ │ │ + bne ff4f04f8 <__bss_end__@@Base+0xff449958> │ │ │ │ ldmibvs fp!, {r0, r1, r3, r4, r5, r6, sp, lr} │ │ │ │ @ instruction: 0x61bb3301 │ │ │ │ svclt 0x0000e7e2 │ │ │ │ mrrcne 9, 11, r6, sl, cr11 @ │ │ │ │ subsvs r6, sl, fp, lsr r8 │ │ │ │ vtst.8 q11, q2, │ │ │ │ vsubl.s8 , d12, d7 │ │ │ │ - blx fe09ea5e <__bss_end__@@Base+0xfdff7e26> │ │ │ │ + blx fe09e9e6 <__bss_end__@@Base+0xfdff7e46> │ │ │ │ ldrmi r1, [sl], #-515 @ 0xfffffdfd │ │ │ │ bfine r1, r2, #8, #20 │ │ │ │ mrrcne 10, 13, r1, sl, cr3 │ │ │ │ addsvs r6, sl, fp, lsr r8 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ @ instruction: 0xf64a1e5a │ │ │ │ @ instruction: 0xf6cf6380 │ │ │ │ - blx b31be <__bss_end__@@Base+0xc586> │ │ │ │ + blx b3146 <__bss_end__@@Base+0xc5a6> │ │ │ │ ldmdavs sl!, {r0, r1, r8, r9, ip, sp, lr, pc}^ │ │ │ │ rsbsvs r4, fp, r3, lsl r4 │ │ │ │ vtst.8 q11, , │ │ │ │ vmlal.s , d25, d1[1] │ │ │ │ - blx fe09ac62 <__bss_end__@@Base+0xfdff402a> │ │ │ │ + blx fe09abea <__bss_end__@@Base+0xfdff404a> │ │ │ │ ldrmi r1, [sl], #-515 @ 0xfffffdfd │ │ │ │ @ instruction: 0x17db12d2 │ │ │ │ ldmdavs fp!, {r1, r4, r6, r7, r9, fp, ip} │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r7, sp, lr} │ │ │ │ vtst.8 q11, , q5 │ │ │ │ @ instruction: 0xf6cf13f0 │ │ │ │ - blx b31f2 <__bss_end__@@Base+0xc5ba> │ │ │ │ + blx b317a <__bss_end__@@Base+0xc5da> │ │ │ │ ldmdavs sl!, {r0, r1, r8, r9, ip, sp, lr, pc}^ │ │ │ │ rsbsvs r4, fp, r3, lsl r4 │ │ │ │ @ instruction: 0xf648687b │ │ │ │ @ instruction: 0xf6c80289 │ │ │ │ - blx fe096c2a <__bss_end__@@Base+0xfdfefff2> │ │ │ │ + blx fe096bb2 <__bss_end__@@Base+0xfdff0012> │ │ │ │ ldrmi r1, [sl], #-515 @ 0xfffffdfd │ │ │ │ @ instruction: 0x17db1152 │ │ │ │ ldmdavs fp!, {r1, r4, r6, r7, r9, fp, ip} │ │ │ │ ldmdavs fp!, {r1, r3, r4, r8, sp, lr} │ │ │ │ @ instruction: 0xf06f691b │ │ │ │ - blx 96b0e <__bss_start@@Base+0x3ba6e> │ │ │ │ + blx 96a96 <__bss_start@@Base+0x3ba8e> │ │ │ │ ldmdavs sl!, {r0, r1, r8, r9, ip, sp, lr, pc}^ │ │ │ │ rsbsvs r4, fp, r3, lsl r4 │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, fp, sp, lr}^ │ │ │ │ svclt 0x0000615a │ │ │ │ ldrtmi r3, [sp], r0, lsr #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq r4, r4, sl, ror #10 │ │ │ │ + andeq r4, r4, sl, asr #10 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ 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ffc26cf8 <__bss_end__@@Base+0xffb800c0> │ │ │ │ + ble ffc26c80 <__bss_end__@@Base+0xffb800e0> │ │ │ │ mcr 8, 0, r6, cr7, cr11, {7} │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r5, r6, r7, r8, r9, fp, sp, lr}^ │ │ │ │ - bcc fe451abc <__bss_end__@@Base+0xfe3aae84> │ │ │ │ - blmi ffa11d84 <__bss_end__@@Base+0xff96b14c> │ │ │ │ + bcc fe451a44 <__bss_end__@@Base+0xfe3aaea4> │ │ │ │ + blmi ffa11d0c <__bss_end__@@Base+0xff96b16c> │ │ │ │ mcr 8, 0, r6, cr7, cr11, {5} │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ @ instruction: 0xee845be7 │ │ │ │ vadd.f64 d7, d6, d5 │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ ldrcc r0, [r0, -r7, asr #22] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ umulllt fp, r9, r0, r5 │ │ │ │ rsbsvs sl, r8, r2, lsl #30 │ │ │ │ cmnvs fp, r0, lsl #6 │ │ │ │ @ instruction: 0x73b2f240 │ │ │ │ ands r6, ip, fp, lsr r1 │ │ │ │ - blcc 707c4 <__bss_start@@Base+0x15724> │ │ │ │ + blcc 7074c <__bss_start@@Base+0x15744> │ │ │ │ ldmdbvs r8!, {r0, r1, r3, r4, r5, r8, sp, lr} │ │ │ │ mcr2 7, 7, pc, cr13, cr15, {7} @ │ │ │ │ ldmdbvs fp!, {r1, r9, sl, lr}^ │ │ │ │ @ instruction: 0x617b1a9b │ │ │ │ - blcs 308d8 │ │ │ │ + blcs 30860 │ │ │ │ ldmdbvs fp!, {r0, r1, r2, r3, r8, sl, fp, ip, lr, pc} │ │ │ │ rsbvc pc, sp, #64, 4 │ │ │ │ mulle sl, r3, r2 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldrbtmi r4, [sl], #-2682 @ 0xfffff586 │ │ │ │ ldmdami sl!, {r0, r2, r5, r6, r8, sp}^ │ │ │ │ @ instruction: 0xf7fc4478 │ │ │ │ - @ instruction: 0xf7ecfa8f │ │ │ │ - ldmdavs fp!, {r1, r2, r3, r4, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ecfe83 │ │ │ │ + ldmdavs fp!, {r1, r4, r5, r9, sl, fp, sp, lr, pc}^ │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ ldclle 2, cr4, [sp], {154} @ 0x9a │ │ │ │ ldmdbvs r8!, {r0, r1, r2, r4, sp, lr, pc} │ │ │ │ mcr2 7, 6, pc, cr13, cr15, {7} @ │ │ │ │ ldmdbvs fp!, {r1, r9, sl, lr}^ │ │ │ │ cmnvs fp, r3, lsl r4 │ │ │ │ - blcs 30918 │ │ │ │ + blcs 308a0 │ │ │ │ ldmdavs fp!, {r1, r3, sl, fp, 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<__bss_end__@@Base+0xff84021c> │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - vstrle d2, [pc, #-0] @ 163d4 │ │ │ │ + vstrle d2, [pc, #-0] @ 1635c │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ - blmi 125dd44 <__bss_end__@@Base+0x11b710c> │ │ │ │ + blmi 125dccc <__bss_end__@@Base+0x11b712c> │ │ │ │ ldmvs r8!, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - blx 11f41a <__bss_end__@@Base+0x787e2> │ │ │ │ + blx 11f3a2 <__bss_end__@@Base+0x78802> │ │ │ │ strmi pc, [r1], #-0 │ │ │ │ eorcc pc, r1, r3, asr r8 @ │ │ │ │ stcle 2, cr4, [sl, #-616] @ 0xfffffd98 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldrbtmi r4, [sl], #-2627 @ 0xfffff5bd │ │ │ │ stmdami r3, {r0, r1, r3, r4, r5, r6, r8, sp}^ │ │ │ │ @ instruction: 0xf7fc4478 │ │ │ │ - @ instruction: 0xf7ecfa11 │ │ │ │ - ldmdavs fp!, {r5, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ - blcs 3077c │ │ │ │ + @ instruction: 0xf7ecfe05 │ │ │ │ + ldmdavs fp!, {r2, r4, r5, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + blcs 30704 │ │ │ │ ldmdavs fp!, {r0, r1, r4, r8, r9, fp, ip, lr, pc}^ │ │ │ │ - blcs 5f0784 <__bss_end__@@Base+0x549b4c> │ │ │ │ + blcs 5f070c <__bss_end__@@Base+0x549b6c> │ │ │ │ ldmdavs fp!, {r0, r1, r2, r3, sl, fp, ip, lr, pc}^ │ │ │ │ - blcs 3088c │ │ │ │ + blcs 30814 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r8, r9, fp, ip, lr, pc}^ │ │ │ │ - blcs ef0894 <__bss_end__@@Base+0xe49c5c> │ │ │ │ + blcs ef081c <__bss_end__@@Base+0xe49c7c> │ │ │ │ ldmdavs fp!, {r0, r1, r2, sl, fp, ip, lr, pc}^ │ │ │ │ - blcs 3099c │ │ │ │ + blcs 30924 │ │ │ │ ldmdavs fp!, {r0, r1, r8, r9, fp, ip, lr, pc}^ │ │ │ │ - blcs ef09a4 <__bss_end__@@Base+0xe49d6c> │ │ │ │ + blcs ef092c <__bss_end__@@Base+0xe49d8c> │ │ │ │ ldmdavs fp!, {r0, r4, r8, sl, fp, ip, lr, pc}^ │ │ │ │ ldmdavs fp!, {r0, r3, r4, r6, r7, fp, sp, lr}^ │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r8, fp, sp, lr}^ │ │ │ │ andls r6, r1, #1343488 @ 0x148000 │ │ │ │ strmi r9, [fp], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [sl], #-2608 @ 0xfffff5d0 │ │ │ │ ldmdami r0!, {r0, r1, r2, r3, r4, r5, r6, r8, sp} │ │ │ │ @ instruction: 0xf7fc4478 │ │ │ │ - @ instruction: 0xf7ecf9e7 │ │ │ │ - ldmdavs fp!, {r1, r2, r4, r5, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ecfddb │ │ │ │ + ldmdavs fp!, {r1, r3, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ mrcne 8, 2, r6, cr10, cr11, {4} │ │ │ │ @ instruction: 0x43a3f44f │ │ │ │ movweq pc, #4800 @ 0x12c0 @ │ │ │ │ vqdmulh.s d15, d2, d3 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ msrvs SPSR_c, pc, asr #8 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ ldmdavs fp!, {r1, r3, r4, sl, lr}^ │ │ │ │ teqcs ip, fp, lsl r9 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ ldmdavs fp!, {r1, r3, r4, sl, lr}^ │ │ │ │ ldrmi r6, [r3], #-2395 @ 0xfffff6a5 │ │ │ │ ldrmi r6, [r3], #-2426 @ 0xfffff686 │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ - ble 3a109c <__bss_end__@@Base+0x2fa464> │ │ │ │ + ble 3a1024 <__bss_end__@@Base+0x2fa484> │ │ │ │ vmul.i8 d22, d0, d27 │ │ │ │ addsmi r7, r3, #536870923 @ 0x2000000b │ │ │ │ ldmdbvs fp!, {r0, r3, r8, sl, fp, ip, lr, pc} │ │ │ │ ldrbtmi r4, [sl], #-2587 @ 0xfffff5e5 │ │ │ │ ldmdami fp, {r1, r7, r8, sp} │ │ │ │ @ instruction: 0xf7fc4478 │ │ │ │ - @ instruction: 0xf7ecf9b9 │ │ │ │ - ldmdbvs fp!, {r3, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ - blle 3a10c0 <__bss_end__@@Base+0x2fa488> │ │ │ │ + @ instruction: 0xf7ecfdad │ │ │ │ + ldmdbvs fp!, {r2, r3, r4, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + blle 3a1048 <__bss_end__@@Base+0x2fa4a8> │ │ │ │ vmul.i8 d22, d0, d27 │ │ │ │ addsmi r7, r3, #268435467 @ 0x1000000b │ │ │ │ ldmdbvs fp!, {r0, r3, sl, fp, ip, lr, pc} │ │ │ │ ldrbtmi r4, [sl], #-2580 @ 0xfffff5ec │ │ │ │ ldmdami r4, {r0, r2, r7, r8, sp} │ │ │ │ @ instruction: 0xf7fc4478 │ │ │ │ - @ instruction: 0xf7ecf9a7 │ │ │ │ - ldmdbvs fp!, {r1, r2, r4, r5, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ecfd9b │ │ │ │ + ldmdbvs fp!, {r1, r3, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0x371c4618 │ │ │ │ ldclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r9, r3, r6, lsr ip │ │ │ │ - andeq r9, r3, r0, asr ip │ │ │ │ - andeq r9, r3, r8, lsr #24 │ │ │ │ - andeq r9, r3, sl, lsl ip │ │ │ │ - strdeq r9, [r3], -lr │ │ │ │ - ldrdeq r9, [r3], -r0 │ │ │ │ - andeq r4, r4, r6, lsr #6 │ │ │ │ - andeq r4, r4, r0, ror #5 │ │ │ │ - andeq r9, r3, r6, lsr #23 │ │ │ │ - andeq r9, r3, r4, asr fp │ │ │ │ - andeq r9, r3, lr, ror fp │ │ │ │ - andeq r9, r3, r0, lsl #22 │ │ │ │ - @ instruction: 0x00039ab2 │ │ │ │ - andeq r9, r3, r4, lsr #21 │ │ │ │ - andeq r9, r3, r6, ror #20 │ │ │ │ - andeq r9, r3, r0, lsl #21 │ │ │ │ + andeq r9, r3, sl, lsr #23 │ │ │ │ + andeq r9, r3, r4, asr #23 │ │ │ │ + muleq r3, ip, fp │ │ │ │ + andeq r9, r3, lr, lsl #23 │ │ │ │ + andeq r9, r3, r2, ror fp │ │ │ │ + andeq r9, r3, r4, asr #22 │ │ │ │ + andeq r4, r4, r6, lsl #6 │ │ │ │ + andeq r4, r4, r0, asr #5 │ │ │ │ + andeq r9, r3, sl, lsl fp │ │ │ │ + andeq r9, r3, r8, asr #21 │ │ │ │ + strdeq r9, [r3], -r2 │ │ │ │ + andeq r9, r3, r4, ror sl │ │ │ │ + andeq r9, r3, r6, lsr #20 │ │ │ │ + andeq r9, r3, r8, lsl sl │ │ │ │ + ldrdeq r9, [r3], -sl │ │ │ │ + strdeq r9, [r3], -r4 │ │ │ │ @ instruction: 0xb088b5b0 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xf107687b │ │ │ │ ldrmi r0, [sp], -r8, lsl #8 │ │ │ │ - strgt ip, [pc], #-3343 @ 1653c │ │ │ │ + strgt ip, [pc], #-3343 @ 164c4 │ │ │ │ muleq r3, r5, r8 │ │ │ │ andeq lr, r3, r4, lsl #17 │ │ │ │ @ instruction: 0x461868bb │ │ │ │ stc2 7, cr15, [r4, #1020] @ 0x3fc │ │ │ │ - blcs 27d5c │ │ │ │ + blcs 27ce4 │ │ │ │ vhadd.s8 d29, d0, d3 │ │ │ │ ldrhtvs r7, [fp], r4 │ │ │ │ vhadd.s8 d30, d0, d2 │ │ │ │ ldrhtvs r7, [fp], r2 │ │ │ │ movweq pc, #33031 @ 0x8107 @ │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ strmi pc, [r3], -fp, lsr #29 │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ cdp 14, 11, cr15, cr0, cr5, {3} │ │ │ │ ldmvs fp!, {r6, r8, r9, fp, sp, lr} │ │ │ │ - bcc fe451d98 <__bss_end__@@Base+0xfe3ab160> │ │ │ │ - blvc ffa12060 <__bss_end__@@Base+0xff96b428> │ │ │ │ - blvs 1211e5c <__bss_end__@@Base+0x116b224> │ │ │ │ + bcc fe451d20 <__bss_end__@@Base+0xfe3ab180> │ │ │ │ + blvc ffa11fe8 <__bss_end__@@Base+0xff96b448> │ │ │ │ + blvs 1211de4 <__bss_end__@@Base+0x116b244> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - bcc fe451da8 <__bss_end__@@Base+0xfe3ab170> │ │ │ │ - blvc ffa12070 <__bss_end__@@Base+0xff96b438> │ │ │ │ - blvc 211e6c <__bss_end__@@Base+0x16b234> │ │ │ │ - bleq 1212058 <__bss_end__@@Base+0x116b420> │ │ │ │ + bcc fe451d30 <__bss_end__@@Base+0xfe3ab190> │ │ │ │ + blvc ffa11ff8 <__bss_end__@@Base+0xff96b458> │ │ │ │ + blvc 211df4 <__bss_end__@@Base+0x16b254> │ │ │ │ + bleq 1211fe0 <__bss_end__@@Base+0x116b440> │ │ │ │ ldrtmi r3, [sp], r0, lsr #14 │ │ │ │ strlt fp, [r0, #3504] @ 0xdb0 │ │ │ │ svcge 0x0002b088 │ │ │ │ - bleq 51bc4 │ │ │ │ - blvc 51c08 │ │ │ │ - blvs 1a91c2c <__bss_end__@@Base+0x19eaff4> │ │ │ │ - blvc ff1d2084 <__bss_end__@@Base+0xff12b44c> │ │ │ │ - blx 45217c <__bss_end__@@Base+0x3ab544> │ │ │ │ + bleq 51b4c │ │ │ │ + blvc 51b90 │ │ │ │ + blvs 1a91bb4 <__bss_end__@@Base+0x19eb014> │ │ │ │ + blvc ff1d200c <__bss_end__@@Base+0xff12b46c> │ │ │ │ + blx 452104 <__bss_end__@@Base+0x3ab564> │ │ │ │ movwcs fp, #8108 @ 0x1fac │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ movweq pc, #4227 @ 0x1083 @ │ │ │ │ - blcs 43134 │ │ │ │ + blcs 430bc │ │ │ │ ldc 1, cr13, [r7, #64] @ 0x40 │ │ │ │ - vldr d7, [pc] @ 165d0 │ │ │ │ + vldr d7, [pc] @ 16558 │ │ │ │ vcmp.f64 d6, d19 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ svclt 0x0094fa10 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0xf083b2db │ │ │ │ sbcslt r0, fp, #67108864 @ 0x4000000 │ │ │ │ andle r2, lr, r0, lsl #22 │ │ │ │ movwcs lr, #2519 @ 0x9d7 │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ ldrbtmi r4, [fp], #-2907 @ 0xfffff4a5 │ │ │ │ orrscs r4, r8, sl, lsl r6 │ │ │ │ ldrbtmi r4, [fp], #-2906 @ 0xfffff4a6 │ │ │ │ @ instruction: 0xf7fc4618 │ │ │ │ - @ instruction: 0xf7ecf911 │ │ │ │ - ldc 12, cr14, [r7, #640] @ 0x280 │ │ │ │ + @ instruction: 0xf7ecfd05 │ │ │ │ + ldc 12, cr14, [r7, #720] @ 0x2d0 │ │ │ │ vmov.f64 d23, #208 @ 0xbe800000 -0.250 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ smlalsvs r3, fp, r0, sl │ │ │ │ cmnvs fp, r0, lsl #6 │ │ │ │ @ instruction: 0x73b2f240 │ │ │ │ eor r6, r0, fp, lsr r1 │ │ │ │ - blcc 70b14 <__bss_start@@Base+0x15a74> │ │ │ │ + blcc 70a9c <__bss_start@@Base+0x15a94> │ │ │ │ ldmdbvs r8!, {r0, r1, r3, r4, r5, r8, sp, lr} │ │ │ │ stc2l 7, cr15, [r5, #-1020] @ 0xfffffc04 │ │ │ │ ldmdbvs fp!, {r1, r9, sl, lr}^ │ │ │ │ @ instruction: 0x617b1a9b │ │ │ │ - blcs 30c28 │ │ │ │ + blcs 30bb0 │ │ │ │ ldmvs fp!, {r0, r1, r4, r8, sl, fp, ip, lr, pc}^ │ │ │ │ rsbvc pc, sp, #64, 4 │ │ │ │ mulle lr, r3, r2 │ │ │ │ movwcs lr, #2519 @ 0x9d7 │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ ldrbtmi r4, [fp], #-2886 @ 0xfffff4ba │ │ │ │ @ instruction: 0x21a5461a │ │ │ │ ldrbtmi r4, [fp], #-2885 @ 0xfffff4bb │ │ │ │ @ instruction: 0xf7fc4618 │ │ │ │ - @ instruction: 0xf7ecf8e3 │ │ │ │ - ldmdbvs sl!, {r1, r4, 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<__bss_end__@@Base+0xff16b6c0> │ │ │ │ + bcs fe451ecc <__bss_end__@@Base+0xfe3ab32c> │ │ │ │ ldrmi r6, [r3], #-2427 @ 0xfffff685 │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ - ble 4e12f4 <__bss_end__@@Base+0x43a6bc> │ │ │ │ + ble 4e127c <__bss_end__@@Base+0x43a6dc> │ │ │ │ vtst.8 q11, q8, │ │ │ │ addsmi r7, r3, #268435467 @ 0x1000000b │ │ │ │ ldmib r7, {r1, r2, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ stmib sp, {r8, r9, sp}^ │ │ │ │ - blmi 75f308 <__bss_end__@@Base+0x6b86d0> │ │ │ │ + blmi 75f290 <__bss_end__@@Base+0x6b86f0> │ │ │ │ @ instruction: 0x461a447b │ │ │ │ - blmi 71ede0 <__bss_end__@@Base+0x6781a8> │ │ │ │ + blmi 71ed68 <__bss_end__@@Base+0x6781c8> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - @ instruction: 0xf888f7fc │ │ │ │ - ldc 7, cr15, [r6], {236} @ 0xec │ │ │ │ - blcs 30d0c │ │ │ │ + ldc2l 7, cr15, [ip], #-1008 @ 0xfffffc10 │ │ │ │ + stc 7, cr15, [sl], #-944 @ 0xfffffc50 │ │ │ │ + blcs 30c94 │ │ │ │ ldmvs fp!, {r0, r1, r4, r8, r9, fp, ip, lr, pc}^ │ │ │ │ adcsvc pc, r1, #64, 4 │ │ │ │ stcle 2, cr4, [lr], {147} @ 0x93 │ │ │ │ movwcs lr, #2519 @ 0x9d7 │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ ldrbtmi r4, [fp], #-2835 @ 0xfffff4ed │ │ │ │ @ instruction: 0x21b7461a │ │ │ │ ldrbtmi r4, [fp], #-2834 @ 0xfffff4ee │ │ │ │ @ instruction: 0xf7fc4618 │ │ │ │ - @ instruction: 0xf7ecf871 │ │ │ │ - ldmdbvs fp!, {sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ecfc65 │ │ │ │ + ldmdbvs fp!, {r2, r4, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0x37184618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ mvngt r0, r0 │ │ │ │ @ instruction: 0xffc00000 │ │ │ │ - ldrshmi pc, [pc, #255] @ 16863 @ │ │ │ │ - strdeq r9, [r3], -r6 │ │ │ │ - andeq r9, r3, r6, asr r9 │ │ │ │ - @ instruction: 0x000399ba │ │ │ │ - strdeq r9, [r3], -sl │ │ │ │ - muleq r3, r8, r9 │ │ │ │ - @ instruction: 0x000398b8 │ │ │ │ - andeq r9, r3, r4, lsr #18 │ │ │ │ - andeq r9, r3, r4, asr #16 │ │ │ │ - ldrdeq r9, [r3], -r6 │ │ │ │ - andeq r9, r3, r6, lsl r8 │ │ │ │ + ldrshmi pc, [pc, #255] @ 167eb @ │ │ │ │ + andeq r9, r3, sl, ror #18 │ │ │ │ + andeq r9, r3, sl, asr #17 │ │ │ │ + andeq r9, r3, lr, lsr #18 │ │ │ │ + andeq r9, r3, lr, ror #16 │ │ │ │ + andeq r9, r3, ip, lsl #18 │ │ │ │ + andeq r9, r3, ip, lsr #16 │ │ │ │ + muleq r3, r8, r8 │ │ │ │ + @ instruction: 0x000397b8 │ │ │ │ + andeq r9, r3, sl, asr #16 │ │ │ │ + andeq r9, r3, sl, lsl #15 │ │ │ │ addlt fp, r8, r0, lsl #11 │ │ │ │ stc 15, cr10, [r7, #8] │ │ │ │ rsbsvs r0, r8, r2, lsl #22 │ │ │ │ - blvc d1df8 <__bss_end__@@Base+0x2b1c0> │ │ │ │ - blvs e11e1c <__bss_end__@@Base+0xd6b1e4> │ │ │ │ - blvc ff1d2274 <__bss_end__@@Base+0xff12b63c> │ │ │ │ - blx 45236c <__bss_end__@@Base+0x3ab734> │ │ │ │ + blvc d1d80 <__bss_end__@@Base+0x2b1e0> │ │ │ │ + blvs e11da4 <__bss_end__@@Base+0xd6b204> │ │ │ │ + blvc ff1d21fc <__bss_end__@@Base+0xff12b65c> │ │ │ │ + blx 4522f4 <__bss_end__@@Base+0x3ab754> │ │ │ │ movwcs fp, #8108 @ 0x1fac │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ movweq pc, #4227 @ 0x1083 @ │ │ │ │ - blcs 43324 │ │ │ │ + blcs 432ac │ │ │ │ ldc 1, cr13, [r7, #64] @ 0x40 │ │ │ │ - vldr d7, [pc, #8] @ 167c8 │ │ │ │ + vldr d7, [pc, #8] @ 16750 │ │ │ │ vmov.u16 r6, d4[2] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ svclt 0x0094fa10 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0xf083b2db │ │ │ │ sbcslt r0, fp, #67108864 @ 0x4000000 │ │ │ │ andle r2, lr, r0, lsl #22 │ │ │ │ movwcs lr, #10711 @ 0x29d7 │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ ldrbtmi r4, [fp], #-2861 @ 0xfffff4d3 │ │ │ │ @ instruction: 0x21bf461a │ │ │ │ ldrbtmi r4, [fp], #-2860 @ 0xfffff4d4 │ │ │ │ @ instruction: 0xf7fc4618 │ │ │ │ - @ instruction: 0xf7ecf819 │ │ │ │ - vldr d14, [r7, #672] @ 0x2a0 │ │ │ │ + @ instruction: 0xf7ecfc0d │ │ │ │ + vldr d14, [r7, #752] @ 0x2f0 │ │ │ │ vmov.f64 d23, #210 @ 0xbe900000 -0.2812500 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ @ instruction: 0x617b3a90 │ │ │ │ @ instruction: 0xf7ff6978 │ │ │ │ strmi pc, [r3], -r3, lsr #24 │ │ │ │ andsle r2, r6, r0, lsl #22 │ │ │ │ @ instruction: 0xee07697b │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ vldr d7, [r7, #924] @ 0x39c │ │ │ │ vadd.f64 d6, d6, d2 │ │ │ │ - vldr d7, [pc, #284] @ 16944 │ │ │ │ + vldr d7, [pc, #284] @ 168cc │ │ │ │ vmov.32 r6, d7[1] │ │ │ │ vmov.f64 d7, #6 @ 0x40300000 2.750 │ │ │ │ @ instruction: 0xf7ff0b47 │ │ │ │ @ instruction: 0x4603feb4 │ │ │ │ @ instruction: 0x46186879 │ │ │ │ mrrc2 7, 15, pc, r4, cr15 @ │ │ │ │ ldmdbvs fp!, {r0, r2, r4, sp, lr, pc}^ │ │ │ │ - bcc fe452064 <__bss_end__@@Base+0xfe3ab42c> │ │ │ │ - blvc ffa1232c <__bss_end__@@Base+0xff96b6f4> │ │ │ │ - blvs d1eac <__bss_end__@@Base+0x2b274> │ │ │ │ - blvc 121212c <__bss_end__@@Base+0x116b4f4> │ │ │ │ - blvs 411ed4 <__bss_end__@@Base+0x36b29c> │ │ │ │ - blvc 1d2138 <__bss_end__@@Base+0x12b500> │ │ │ │ - bleq 1212320 <__bss_end__@@Base+0x116b6e8> │ │ │ │ + bcc fe451fec <__bss_end__@@Base+0xfe3ab44c> │ │ │ │ + blvc ffa122b4 <__bss_end__@@Base+0xff96b714> │ │ │ │ + blvs d1e34 <__bss_end__@@Base+0x2b294> │ │ │ │ + blvc 12120b4 <__bss_end__@@Base+0x116b514> │ │ │ │ + blvs 411e5c <__bss_end__@@Base+0x36b2bc> │ │ │ │ + blvc 1d20c0 <__bss_end__@@Base+0x12b520> │ │ │ │ + bleq 12122a8 <__bss_end__@@Base+0x116b708> │ │ │ │ mrc2 7, 4, pc, cr13, cr15, {7} │ │ │ │ ldmdavs r9!, {r0, r1, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ ldmdavs fp!, {r0, r2, r3, r4, r5, sl, fp, ip, sp, lr, pc}^ │ │ │ │ andsvs r6, sl, sl, ror r9 │ │ │ │ ldrcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ mvngt r0, r0 │ │ │ │ @ instruction: 0xffc00000 │ │ │ │ - ldrshmi pc, [pc, #255] @ 1698b @ │ │ │ │ + ldrshmi pc, [pc, #255] @ 16913 @ │ │ │ │ andeq r0, r0, r0 │ │ │ │ addsmi sp, lr, r0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ addsmi ip, lr, r0, lsl #16 │ │ │ │ - andeq r9, r3, r6, ror #16 │ │ │ │ - andeq r9, r3, r6, ror #14 │ │ │ │ + ldrdeq r9, [r3], -sl │ │ │ │ + ldrdeq r9, [r3], -sl │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ands r6, r4, sl, lsl r0 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - blx 9f0ea <__bss_start@@Base+0x4404a> │ │ │ │ + blx 9f072 <__bss_start@@Base+0x4406a> │ │ │ │ ldmvs sl!, {r0, r1, r8, r9, ip, sp, lr, pc}^ │ │ │ │ ldmdavc r2, {r1, r4, fp, sp, lr} │ │ │ │ @ instruction: 0xf1a34413 │ │ │ │ ldmdavs fp!, {r4, r5, r9}^ │ │ │ │ ldmvs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ mrrcne 8, 1, r6, sl, cr11 │ │ │ │ @ instruction: 0x601a68fb │ │ │ │ - blcc 70bcc <__bss_start@@Base+0x15b2c> │ │ │ │ + blcc 70b54 <__bss_start@@Base+0x15b4c> │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r7, sp, lr} │ │ │ │ vstrle d2, [sp, #-0] │ │ │ │ - stcl 7, cr15, [lr, #-944] @ 0xfffffc50 │ │ │ │ + stcl 7, cr15, [r6, #-944]! @ 0xfffffc50 │ │ │ │ ldmdavs sl, {r0, r1, r9, sl, lr} │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ subseq r7, fp, fp, lsl r8 │ │ │ │ ldmdahi fp, {r0, r1, r4, sl, lr} │ │ │ │ movwvs pc, #1027 @ 0x403 @ │ │ │ │ bicsle r2, r9, r0, lsl #22 │ │ │ │ - blcs 30bf4 │ │ │ │ + blcs 30b7c │ │ │ │ movwcs fp, #7948 @ 0x1f0c │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, sl, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ @@ -19664,30 +19659,30 @@ │ │ │ │ andle r2, r1, sp, lsr #22 │ │ │ │ adcs r2, r0, r0, lsl #6 │ │ │ │ movwcc r6, #6267 @ 0x187b │ │ │ │ @ instruction: 0xf107607b │ │ │ │ ldcne 2, cr0, [fp, #-112]! @ 0xffffff90 │ │ │ │ ldrmi r2, [r8], -r2, lsl #2 │ │ │ │ @ instruction: 0xff96f7ff │ │ │ │ - blcs 28188 │ │ │ │ + blcs 28110 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ movwcs lr, #8353 @ 0x20a1 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r9, sp, lr}^ │ │ │ │ - blcs b749f8 <__bss_end__@@Base+0xacddc0> │ │ │ │ + blcs b74980 <__bss_end__@@Base+0xacdde0> │ │ │ │ ldmdavs fp!, {r1, r4, r6, r8, ip, lr, pc}^ │ │ │ │ rsbsvs r3, fp, r1, lsl #6 │ │ │ │ andseq pc, r8, #-1073741823 @ 0xc0000001 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bvs 1f0eb88 <__bss_end__@@Base+0x1e67f50> │ │ │ │ + bvs 1f0eb10 <__bss_end__@@Base+0x1e67f70> │ │ │ │ rsbsvs r3, fp, #134217728 @ 0x8000000 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ tstle r1, sl, lsr fp │ │ │ │ movwcc r6, #6267 @ 0x187b │ │ │ │ @ instruction: 0xf107607b │ │ │ │ ldcne 2, cr0, [fp, #-48]! @ 0xffffffd0 │ │ │ │ ldrmi r2, [r8], -r2, lsl #2 │ │ │ │ @ instruction: 0xff40f7ff │ │ │ │ - blcs 28234 │ │ │ │ + blcs 281bc │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ - bvs 1f0eb5c <__bss_end__@@Base+0x1e67f24> │ │ │ │ + bvs 1f0eae4 <__bss_end__@@Base+0x1e67f44> │ │ │ │ rsbsvs r3, fp, #67108864 @ 0x4000000 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ sub r2, r2, r0, lsl #6 │ │ │ │ vpmin.s8 d22, d0, d27 │ │ │ │ addsmi r6, r3, #-536870910 @ 0xe0000002 │ │ │ │ - bvs f0deec <__bss_end__@@Base+0xe672b4> │ │ │ │ + bvs f0de74 <__bss_end__@@Base+0xe672d4> │ │ │ │ andvc pc, pc, #536870916 @ 0x20000004 │ │ │ │ stcle 2, cr4, [r3], #-588 @ 0xfffffdb4 │ │ │ │ - blcs 31244 │ │ │ │ + blcs 311cc │ │ │ │ ldmibvs fp!, {r5, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xdc1d2b0c │ │ │ │ - blcs 31150 │ │ │ │ + blcs 310d8 │ │ │ │ ldmibvs fp!, {r1, r3, r4, r8, sl, fp, ip, lr, pc} │ │ │ │ @ instruction: 0xdc172b1f │ │ │ │ @ instruction: 0x46186a3b │ │ │ │ - blx ffc54a70 <__bss_end__@@Base+0xffbade38> │ │ │ │ - blcs 28284 │ │ │ │ + blx ffc549f8 <__bss_end__@@Base+0xffbade58> │ │ │ │ + blcs 2820c │ │ │ │ movwcs fp, #7956 @ 0x1f14 │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ ldmibvs fp!, {r3, r4, r9, sl, lr}^ │ │ │ │ - blmi 49e3f0 <__bss_end__@@Base+0x3f77b8> │ │ │ │ + blmi 49e378 <__bss_end__@@Base+0x3f77d8> │ │ │ │ tstcs ip, fp, ror r4 │ │ │ │ @ instruction: 0xf101fb00 │ │ │ │ @ instruction: 0xf853440a │ │ │ │ ldmibvs fp!, {r1, r5, sp} │ │ │ │ - ble 67504 <__bss_start@@Base+0xc464> │ │ │ │ + ble 6748c <__bss_start@@Base+0xc484> │ │ │ │ ands r2, r2, r0, lsl #6 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r9, fp, sp, lr} │ │ │ │ ldmibvs sl!, {r1, r3, r4, sp, lr}^ │ │ │ │ subsvs r6, sl, fp, lsr r8 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r7, r8, fp, sp, lr} │ │ │ │ ldmdbvs sl!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ sbcsvs r6, sl, fp, lsr r8 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r8, fp, sp, lr} │ │ │ │ ldmvs sl!, {r1, r3, r4, r8, sp, lr}^ │ │ │ │ cmpvs sl, fp, lsr r8 │ │ │ │ @ instruction: 0x46186a7b │ │ │ │ ldrtmi r3, [sp], r8, lsr #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq r3, r4, r8, lsr ip │ │ │ │ + andeq r3, r4, r8, lsl ip │ │ │ │ strdlt fp, [fp], r0 │ │ │ │ rscsvs sl, r8, r6, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ - blcs 4f0cd0 <__bss_end__@@Base+0x44a098> │ │ │ │ + blcs 4f0c58 <__bss_end__@@Base+0x44a0b8> │ │ │ │ ldmdavs sp!, {r0, r3, r4, r8, sl, fp, ip, lr, pc}^ │ │ │ │ ldmdavs lr, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldmvs r2, {r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ stmiavs r9, {r0, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ stmdbvs r0, {r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ stmdbvs r4!, {r2, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ andls r9, r3, r4, lsl #8 │ │ │ │ andls r9, r1, #-2147483648 @ 0x80000000 │ │ │ │ ldrtmi r9, [r3], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [sl], #-2600 @ 0xfffff5d8 │ │ │ │ ldmvs r8!, {r0, r3, r5, r9, sl, lr} │ │ │ │ - ldcl 7, cr15, [r0], #944 @ 0x3b0 │ │ │ │ + stc 7, cr15, [r0, #-944] @ 0xfffffc50 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r6, sp, lr, pc}^ │ │ │ │ vldrle d2, [r6, #-64] @ 0xffffffc0 │ │ │ │ ldmvs fp!, {r2, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r0, r2, r3, r4, fp, sp, lr}^ │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r6, fp, sp, lr}^ │ │ │ │ ldmvs r9!, {r1, r4, r7, fp, sp, lr}^ │ │ │ │ ldmvs r8!, {r0, r3, r6, r7, fp, sp, lr}^ │ │ │ │ andls r6, r3, r0, lsl #18 │ │ │ │ andls r9, r1, #-2147483648 @ 0x80000000 │ │ │ │ strtmi r9, [fp], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [sl], #-2588 @ 0xfffff5e4 │ │ │ │ ldmvs r8!, {r0, r5, r9, sl, lr} │ │ │ │ - ldcl 7, cr15, [r6], {236} @ 0xec │ │ │ │ + stcl 7, cr15, [r6], #944 @ 0x3b0 │ │ │ │ ldmdavs fp!, {r0, r2, r3, r5, sp, lr, pc}^ │ │ │ │ - vstrle d2, [pc, #-40] @ 16b2c │ │ │ │ + vstrle d2, [pc, #-40] @ 16ab4 │ │ │ │ ldmvs fp!, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r3, r4, fp, sp, lr}^ │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r6, fp, sp, lr}^ │ │ │ │ andls r6, r1, #9568256 @ 0x920000 │ │ │ │ strmi r9, [r3], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [sl], #-2579 @ 0xfffff5ed │ │ │ │ @ instruction: 0xf7ec68b8 │ │ │ │ - ands lr, sl, r4, asr #25 │ │ │ │ - blcs 1f0d64 <__bss_end__@@Base+0x14a12c> │ │ │ │ + @ instruction: 0xe01aecd4 │ │ │ │ + blcs 1f0cec <__bss_end__@@Base+0x14a14c> │ │ │ │ ldmdavs r9!, {r2, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldrmi r9, [r3], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [sl], #-2572 @ 0xfffff5f4 │ │ │ │ @ instruction: 0xf7ec68b8 │ │ │ │ - @ instruction: 0xe00aecb4 │ │ │ │ - bmi 2b0d84 <__bss_end__@@Base+0x20a14c> │ │ │ │ + and lr, sl, r4, asr #25 │ │ │ │ + bmi 2b0d0c <__bss_end__@@Base+0x20a16c> │ │ │ │ vqshl.s8 q10, q13, q0 │ │ │ │ stmdami r9, {r0, r4, r8, ip} │ │ │ │ - @ instruction: 0xf7fb4478 │ │ │ │ - @ instruction: 0xf7ecfe41 │ │ │ │ - @ instruction: 0x3714e9d0 │ │ │ │ + @ instruction: 0xf7fc4478 │ │ │ │ + @ instruction: 0xf7ecfa35 │ │ │ │ + ldrcc lr, [r4, -r4, ror #19] │ │ │ │ ldcllt 6, cr4, [r0, #756]! @ 0x2f4 │ │ │ │ - andeq r9, r3, sl, asr r5 │ │ │ │ - andeq r9, r3, r6, asr #10 │ │ │ │ - andeq r9, r3, sl, lsr r5 │ │ │ │ - andeq r9, r3, sl, lsr #10 │ │ │ │ - andeq r9, r3, r8, lsr #10 │ │ │ │ - @ instruction: 0x000393b4 │ │ │ │ + andeq r9, r3, lr, asr #9 │ │ │ │ + @ instruction: 0x000394ba │ │ │ │ + andeq r9, r3, lr, lsr #9 │ │ │ │ + muleq r3, lr, r4 │ │ │ │ + muleq r3, ip, r4 │ │ │ │ + andeq r9, r3, r8, lsr #6 │ │ │ │ addlt fp, r5, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, fp, sp, lr} │ │ │ │ - bne ff4f0c48 <__bss_end__@@Base+0xff44a010> │ │ │ │ + bne ff4f0bd0 <__bss_end__@@Base+0xff44a030> │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ ldrsht r6, [r7], -fp │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, fp, sp, lr}^ │ │ │ │ ldrsbtvs r1, [fp], #163 @ 0xa3 │ │ │ │ - blcs 30fe4 │ │ │ │ + blcs 30f6c │ │ │ │ ldmvs fp!, {r0, ip, lr, pc}^ │ │ │ │ ldmdavs fp!, {r2, r3, r5, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, fp, sp, lr} │ │ │ │ - bne ff4f0e74 <__bss_end__@@Base+0xff44a23c> │ │ │ │ + bne ff4f0dfc <__bss_end__@@Base+0xff44a25c> │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ strd r6, [r1], -fp @ │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, fp, sp, lr}^ │ │ │ │ ldrsbtvs r1, [fp], #163 @ 0xa3 │ │ │ │ - blcs 31010 │ │ │ │ + blcs 30f98 │ │ │ │ ldmvs fp!, {r0, ip, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r2, r4, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r8, fp, sp, lr} │ │ │ │ - bne ff4f10a0 <__bss_end__@@Base+0xff44a468> │ │ │ │ + bne ff4f1028 <__bss_end__@@Base+0xff44a488> │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ strd r6, [fp], -fp │ │ │ │ ldmdbvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, fp, sp, lr}^ │ │ │ │ ldrsbtvs r1, [fp], #163 @ 0xa3 │ │ │ │ - blcs 3103c │ │ │ │ + blcs 30fc4 │ │ │ │ ldmvs fp!, {r0, ip, lr, pc}^ │ │ │ │ movwcs lr, #0 │ │ │ │ @ instruction: 0x37144618 │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ ldrlt fp, [r0, #132]! @ 0x84 │ │ │ │ svcge 0x000ab0ac │ │ │ │ ldreq pc, [r8], #263 @ 0x107 │ │ │ │ andeq lr, pc, r4, lsl #17 │ │ │ │ - blpl 1052738 <__bss_end__@@Base+0xfabb00> │ │ │ │ - blvs 109273c <__bss_end__@@Base+0xfebb04> │ │ │ │ - blvc 10d2740 <__bss_end__@@Base+0x102bb08> │ │ │ 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bleq 11927b8 <__bss_end__@@Base+0x10ebb80> │ │ │ │ - blne 11d27bc <__bss_end__@@Base+0x112bb84> │ │ │ │ - blcs 12127c0 <__bss_end__@@Base+0x116bb88> │ │ │ │ + blgt 3d7adc <__bss_end__@@Base+0x330f3c> │ │ │ │ + bleq 1192740 <__bss_end__@@Base+0x10ebba0> │ │ │ │ + blne 11d2744 <__bss_end__@@Base+0x112bba4> │ │ │ │ + blcs 1212748 <__bss_end__@@Base+0x116bba8> │ │ │ │ @ instruction: 0xf980f007 │ │ │ │ ldrsbtcc pc, [r0], #135 @ 0x87 @ │ │ │ │ ldc 12, cr6, [r7, #108] @ 0x6c │ │ │ │ vldr d5, [r7] │ │ │ │ vldr d6, [r7, #8] │ │ │ │ @ instruction: 0xf8d77b04 │ │ │ │ ldrmi r1, [r8], -r0, lsl #1 │ │ │ │ - bleq 11927e0 <__bss_end__@@Base+0x10ebba8> │ │ │ │ - blne 11d27e4 <__bss_end__@@Base+0x112bbac> │ │ │ │ - blcs 12127e8 <__bss_end__@@Base+0x116bbb0> │ │ │ │ + bleq 1192768 <__bss_end__@@Base+0x10ebbc8> │ │ │ │ + blne 11d276c <__bss_end__@@Base+0x112bbcc> │ │ │ │ + blcs 1212770 <__bss_end__@@Base+0x116bbd0> │ │ │ │ @ instruction: 0xf8d4f007 │ │ │ │ - blpl 5238c │ │ │ │ - blvs d2390 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<__bss_end__@@Base+0x28d014> │ │ │ │ @ instruction: 0xf0054630 │ │ │ │ ldc 8, cr15, [r7, #932] @ 0x3a4 │ │ │ │ vldr d6, [r7, #752] @ 0x2f0 │ │ │ │ vadd.f64 d7, d22, d16 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ @ instruction: 0xf5077b82 │ │ │ │ tstls r2, #671088640 @ 0x28000000 │ │ │ │ @ instruction: 0xf507ad08 │ │ │ │ stcgt 4, cr7, [pc], {-0} │ │ │ │ stcgt 5, cr12, [pc], {15} │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1} │ │ │ │ strbtmi r0, [sp], -r3 │ │ │ │ ldrtvc pc, [r2], #-1287 @ 0xfffffaf9 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 16371 │ │ │ │ + strgt ip, [pc, #-3087] @ 162f9 │ │ │ │ muleq pc, r4, r8 @ │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ msrvc CPSR_fsx, #29360128 @ 0x1c00000 │ │ │ │ @ instruction: 0xf005cb0f │ │ │ │ ldc 12, cr15, [r7, #580] @ 0x244 │ │ │ │ vldr d5, [r7, #552] @ 0x228 │ │ │ │ vldr d6, [r7, #560] @ 0x230 │ │ │ │ @ instruction: 0xf1077b8e │ │ │ │ tstls r3, #128, 6 │ │ │ │ tstpcc r0, #14090240 @ p-variant is OBSOLETE @ 0xd70000 │ │ │ │ stcge 3, cr9, [r8, #-72] @ 0xffffffb8 │ │ │ │ strvc pc, [r0], #-1287 @ 0xfffffaf9 │ │ │ │ - strgt ip, [pc, #-3087] @ 163a5 │ │ │ │ - strgt ip, [pc, #-3087] @ 163a9 │ │ │ │ + strgt ip, [pc, #-3087] @ 1632d │ │ │ │ + strgt ip, [pc, #-3087] @ 16331 │ │ │ │ muleq r3, r4, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ @ instruction: 0xf507466d │ │ │ │ stcgt 4, cr7, [pc], {50} @ 0x32 │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1, r2, r3} │ │ │ │ @ instruction: 0xf507000f │ │ │ │ - blgt 3f3c90 <__bss_end__@@Base+0x34d058> │ │ │ │ - bleq 1192a9c <__bss_end__@@Base+0x10ebe64> │ │ │ │ - blne 11d2aa0 <__bss_end__@@Base+0x112be68> │ │ │ │ - blcs 1212aa4 <__bss_end__@@Base+0x116be6c> │ │ │ │ + blgt 3f3c18 <__bss_end__@@Base+0x34d078> │ │ │ │ + bleq 1192a24 <__bss_end__@@Base+0x10ebe84> │ │ │ │ + blne 11d2a28 <__bss_end__@@Base+0x112be88> │ │ │ │ + blcs 1212a2c <__bss_end__@@Base+0x116be8c> │ │ │ │ mrc2 7, 1, pc, cr14, cr15, {7} │ │ │ │ andsvc pc, r0, #29360128 @ 0x1c00000 │ │ │ │ tstpvc r4, r7, lsl #10 @ p-variant is OBSOLETE │ │ │ │ tstpvc r8, #29360128 @ p-variant is OBSOLETE @ 0x1c00000 │ │ │ │ - blpl fe2d2654 <__bss_end__@@Base+0xfe22ba1c> │ │ │ │ - blvs fe352658 <__bss_end__@@Base+0xfe2aba20> │ │ │ │ - blvc fe3d265c <__bss_end__@@Base+0xfe32ba24> │ │ │ │ + blpl fe2d25dc <__bss_end__@@Base+0xfe22ba3c> │ │ │ │ + blvs fe3525e0 <__bss_end__@@Base+0xfe2aba40> │ │ │ │ + blvc fe3d25e4 <__bss_end__@@Base+0xfe32ba44> │ │ │ │ mrc 6, 5, r4, cr0, cr8, {0} │ │ │ │ vmov.f64 d0, d5 │ │ │ │ vmov.f64 d1, d6 │ │ │ │ @ instruction: 0xf0062b47 │ │ │ │ @ instruction: 0xed97f981 │ │ │ │ vldr d6, [r7, #752] @ 0x2f0 │ │ │ │ vadd.f64 d7, d22, d16 │ │ │ │ @@ -20099,15 +20094,15 @@ │ │ │ │ @ instruction: 0xf507ad08 │ │ │ │ stcgt 4, cr7, [pc], {-0} │ │ │ │ stcgt 5, cr12, [pc], {15} │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1} │ │ │ │ strbtmi r0, [sp], -r3 │ │ │ │ ldrtvc pc, [r2], #-1287 @ 0xfffffaf9 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 16439 │ │ │ │ + strgt ip, [pc, #-3087] @ 163c1 │ │ │ │ muleq pc, r4, r8 @ │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ msrvc CPSR_fsx, #29360128 @ 0x1c00000 │ │ │ │ @ instruction: 0xf005cb0f │ │ │ │ ldc 12, cr15, [r7, #180] @ 0xb4 │ │ │ │ vldr d5, [r7, #552] @ 0x228 │ │ │ │ vldr d6, [r7, #560] @ 0x230 │ │ │ │ @@ -20118,31 +20113,31 @@ │ │ │ │ @ instruction: 0xf507ad08 │ │ │ │ stcgt 4, cr7, [pc], {-0} │ │ │ │ stcgt 5, cr12, [pc], {15} │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1} │ │ │ │ strbtmi r0, [sp], -r3 │ │ │ │ ldrtvc pc, [r2], #-1287 @ 0xfffffaf9 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 16485 │ │ │ │ + strgt ip, [pc, #-3087] @ 1640d │ │ │ │ muleq pc, r4, r8 @ │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ msrvc CPSR_fsx, #29360128 @ 0x1c00000 │ │ │ │ vmov.f64 d12, #15 @ 0x40780000 3.875 │ │ │ │ vmov.f64 d0, d5 │ │ │ │ vmov.f64 d1, d6 │ │ │ │ @ instruction: 0xf7ff2b47 │ │ │ │ @ instruction: 0xf507fdd9 │ │ │ │ @ instruction: 0xf1037310 │ │ │ │ @ instruction: 0xf5070208 │ │ │ │ @ instruction: 0xf1037314 │ │ │ │ @ instruction: 0xf5070108 │ │ │ │ movwcc r7, #33560 @ 0x8318 │ │ │ │ - blpl fe2d2728 <__bss_end__@@Base+0xfe22baf0> │ │ │ │ - blvs fe35272c <__bss_end__@@Base+0xfe2abaf4> │ │ │ │ - blvc fe3d2730 <__bss_end__@@Base+0xfe32baf8> │ │ │ │ + blpl fe2d26b0 <__bss_end__@@Base+0xfe22bb10> │ │ │ │ + blvs fe3526b4 <__bss_end__@@Base+0xfe2abb14> │ │ │ │ + blvc fe3d26b8 <__bss_end__@@Base+0xfe32bb18> │ │ │ │ mrc 6, 5, r4, cr0, cr8, {0} │ │ │ │ vmov.f64 d0, d5 │ │ │ │ vmov.f64 d1, d6 │ │ │ │ @ instruction: 0xf0062b47 │ │ │ │ @ instruction: 0xed97f917 │ │ │ │ vldr d6, [r7, #608] @ 0x260 │ │ │ │ vmov.32 r7, d22[1] │ │ │ │ @@ -20163,104 +20158,104 @@ │ │ │ │ vmov.32 r7, d21[1] │ │ │ │ vldr d5, [r7, #284] @ 0x11c │ │ │ │ vldr d4, [r7, #576] @ 0x240 │ │ │ │ vmov.32 r7, d20[1] │ │ │ │ vnmul.f64 d7, d5, d7 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ - @ instruction: 0xf7eb0b47 │ │ │ │ - vstr , [r7, #440] @ 0x1b8 │ │ │ │ + @ instruction: 0xf7ec0b47 │ │ │ │ + stc 8, cr14, [r7, #16] │ │ │ │ @ instruction: 0xf8d70b9c │ │ │ │ @ instruction: 0x463e5314 │ │ │ │ msrvc CPSR_x, #29360128 @ 0x1c00000 │ │ │ │ strvc pc, [r2], #-1443 @ 0xfffffa5d │ │ │ │ msrvc CPSR_x, #29360128 @ 0x1c00000 │ │ │ │ movwvc pc, #9635 @ 0x25a3 @ │ │ │ │ orrcc sl, r0, #1966080 @ 0x1e0000 │ │ │ │ ldrmi r2, [r9], -r0, lsl #5 │ │ │ │ - ldmda lr, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r6!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf1044668 │ │ │ │ rsbscs r0, r8, #8, 6 @ 0x20000000 │ │ │ │ @ instruction: 0xf7ec4619 │ │ │ │ - ldm r4, {r3, r4, r6, fp, sp, lr, pc} │ │ │ │ + ldm r4, {r4, r5, r6, fp, sp, lr, pc} │ │ │ │ ldrtmi r0, [r0], -ip │ │ │ │ stc2 0, cr15, [r8, #-20]! @ 0xffffffec │ │ │ │ msrvc CPSR_x, #29360128 @ 0x1c00000 │ │ │ │ eorvc pc, r2, #683671552 @ 0x28c00000 │ │ │ │ movweq pc, #33029 @ 0x8105 @ │ │ │ │ addcs r4, r0, #17825792 @ 0x1100000 │ │ │ │ @ instruction: 0xf7ec4618 │ │ │ │ - cdp 8, 11, cr14, cr7, cr8, {2} │ │ │ │ + cdp 8, 11, cr14, cr7, cr0, {3} │ │ │ │ vldr d6, [r7] │ │ │ │ vdup.32 d22, r7 │ │ │ │ @ instruction: 0xf8d78b07 │ │ │ │ @ instruction: 0x463e5314 │ │ │ │ tstpmi r4, #14090240 @ p-variant is OBSOLETE @ 0xd70000 │ │ │ │ @ instruction: 0xf1044668 │ │ │ │ rsbscs r0, r8, #16, 6 @ 0x40000000 │ │ │ │ @ instruction: 0xf7ec4619 │ │ │ │ - @ instruction: 0xf104e836 │ │ │ │ - blgt 317de8 <__bss_end__@@Base+0x2711b0> │ │ │ │ - bleq 1252c8c <__bss_end__@@Base+0x11ac054> │ │ │ │ + @ instruction: 0xf104e84e │ │ │ │ + blgt 317d70 <__bss_end__@@Base+0x2711d0> │ │ │ │ + bleq 1252c14 <__bss_end__@@Base+0x11ac074> │ │ │ │ @ instruction: 0xf0054630 │ │ │ │ @ instruction: 0xf507fc69 │ │ │ │ @ instruction: 0xf5a37322 │ │ │ │ @ instruction: 0xf1057222 │ │ │ │ ldrmi r0, [r1], -r8, lsl #6 │ │ │ │ ldrmi r2, [r8], -r0, lsl #5 │ │ │ │ - stmda r2!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda sl!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x466d463e │ │ │ │ ldrtvc pc, [ip], #-1287 @ 0xfffffaf9 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 165e5 │ │ │ │ + strgt ip, [pc, #-3087] @ 1656d │ │ │ │ muleq pc, r4, r8 @ │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ teqpvc sl, #29360128 @ p-variant is OBSOLETE @ 0x1c00000 │ │ │ │ ldrtmi ip, [r0], -ip, lsl #22 │ │ │ │ @ instruction: 0xff8af004 │ │ │ │ msrvc CPSR_x, #29360128 @ 0x1c00000 │ │ │ │ msrvc CPSR_x, #683671552 @ 0x28c00000 │ │ │ │ strvc pc, [r0], #-1287 @ 0xfffffaf9 │ │ │ │ - stcgt 6, cr4, [pc, #-116] @ 171a4 │ │ │ │ - stcgt 4, cr12, [pc, #-60] @ 171e0 │ │ │ │ + stcgt 6, cr4, [pc, #-116] @ 1712c │ │ │ │ + stcgt 4, cr12, [pc, #-60] @ 17168 │ │ │ │ ldm r5, {r0, r1, r2, r3, sl, lr, pc} │ │ │ │ stm r4, {r0, r1} │ │ │ │ @ instruction: 0xf5070003 │ │ │ │ tstls r2, #671088640 @ 0x28000000 │ │ │ │ @ instruction: 0xf507ad08 │ │ │ │ stcgt 4, cr7, [pc], {58} @ 0x3a │ │ │ │ stcgt 5, cr12, [pc], {15} │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1} │ │ │ │ strbtmi r0, [sp], -r3 │ │ │ │ ldrtvc pc, [r2], #-1287 @ 0xfffffaf9 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 1663d │ │ │ │ + strgt ip, [pc, #-3087] @ 165c5 │ │ │ │ muleq pc, r4, r8 @ │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ msrvc CPSR_fsx, #29360128 @ 0x1c00000 │ │ │ │ @ instruction: 0xf005cb0f │ │ │ │ @ instruction: 0xf8d7fb2b │ │ │ │ orrcc r3, r8, #20, 6 @ 0x50000000 │ │ │ │ - blge fe2d28c4 <__bss_end__@@Base+0xfe22bc8c> │ │ │ │ - blls fe3528c8 <__bss_end__@@Base+0xfe2abc90> │ │ │ │ - blhi fe3d28cc <__bss_end__@@Base+0xfe32bc94> │ │ │ │ + blge fe2d284c <__bss_end__@@Base+0xfe22bcac> │ │ │ │ + blls fe352850 <__bss_end__@@Base+0xfe2abcb0> │ │ │ │ + blhi fe3d2854 <__bss_end__@@Base+0xfe32bcb4> │ │ │ │ @ instruction: 0xf5079334 │ │ │ │ @ instruction: 0xf5a37322 │ │ │ │ - blge 533c8c <__bss_end__@@Base+0x48d054> │ │ │ │ + blge 533c14 <__bss_end__@@Base+0x48d074> │ │ │ │ addcs r4, r0, #17825792 @ 0x1100000 │ │ │ │ @ instruction: 0xf7eb4618 │ │ │ │ - @ instruction: 0xf8d7efd4 │ │ │ │ + @ instruction: 0xf8d7efec │ │ │ │ tstls r2, #16, 6 @ 0x40000000 │ │ │ │ @ instruction: 0xf507ad08 │ │ │ │ stcgt 4, cr7, [pc], {58} @ 0x3a │ │ │ │ stcgt 5, cr12, [pc], {15} │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1} │ │ │ │ strbtmi r0, [sp], -r3 │ │ │ │ ldrtvc pc, [r2], #-1287 @ 0xfffffaf9 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 1669d │ │ │ │ + strgt ip, [pc, #-3087] @ 16625 │ │ │ │ muleq pc, r4, r8 @ │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ msrvc CPSR_fsx, #29360128 @ 0x1c00000 │ │ │ │ vmov.f64 d12, #15 @ 0x40780000 3.875 │ │ │ │ vmov.f64 d0, d10 │ │ │ │ vmov.f64 d1, d9 │ │ │ │ @ instruction: 0xf0062b48 │ │ │ │ @@ -20277,47 +20272,47 @@ │ │ │ │ @ instruction: 0xf507ad08 │ │ │ │ stcgt 4, cr7, [pc], {-0} │ │ │ │ stcgt 5, cr12, [pc], {15} │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1} │ │ │ │ strbtmi r0, [sp], -r3 │ │ │ │ ldrtvc pc, [r2], #-1287 @ 0xfffffaf9 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 16701 │ │ │ │ + strgt ip, [pc, #-3087] @ 16689 │ │ │ │ muleq pc, r4, r8 @ │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ msrvc CPSR_fsx, #29360128 @ 0x1c00000 │ │ │ │ @ instruction: 0xf005cb0f │ │ │ │ vldr s30, [r7, #804] @ 0x324 │ │ │ │ vldr d5, [r7, #552] @ 0x228 │ │ │ │ vldr d6, [r7, #560] @ 0x230 │ │ │ │ @ instruction: 0xf1077b8e │ │ │ │ tstls r3, #128, 6 │ │ │ │ tstpcc r0, #14090240 @ p-variant is OBSOLETE @ 0xd70000 │ │ │ │ stcge 3, cr9, [r8, #-72] @ 0xffffffb8 │ │ │ │ strvc pc, [r0], #-1287 @ 0xfffffaf9 │ │ │ │ - strgt ip, [pc, #-3087] @ 16735 │ │ │ │ - strgt ip, [pc, #-3087] @ 16739 │ │ │ │ + strgt ip, [pc, #-3087] @ 166bd │ │ │ │ + strgt ip, [pc, #-3087] @ 166c1 │ │ │ │ muleq r3, r4, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ @ instruction: 0xf507466d │ │ │ │ stcgt 4, cr7, [pc], {50} @ 0x32 │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1, r2, r3} │ │ │ │ @ instruction: 0xf507000f │ │ │ │ - blgt 3f4020 <__bss_end__@@Base+0x34d3e8> │ │ │ │ - bleq 1192e2c <__bss_end__@@Base+0x10ec1f4> │ │ │ │ - blne 11d2e30 <__bss_end__@@Base+0x112c1f8> │ │ │ │ - blcs 1212e34 <__bss_end__@@Base+0x116c1fc> │ │ │ │ + blgt 3f3fa8 <__bss_end__@@Base+0x34d408> │ │ │ │ + bleq 1192db4 <__bss_end__@@Base+0x10ec214> │ │ │ │ + blne 11d2db8 <__bss_end__@@Base+0x112c218> │ │ │ │ + blcs 1212dbc <__bss_end__@@Base+0x116c21c> │ │ │ │ ldc2l 7, cr15, [r6], #-1020 @ 0xfffffc04 │ │ │ │ andsvc pc, r0, #29360128 @ 0x1c00000 │ │ │ │ tstpvc r4, r7, lsl #10 @ p-variant is OBSOLETE │ │ │ │ tstpvc r8, #29360128 @ p-variant is OBSOLETE @ 0x1c00000 │ │ │ │ - blpl fe2d29e4 <__bss_end__@@Base+0xfe22bdac> │ │ │ │ - blvs fe3529e8 <__bss_end__@@Base+0xfe2abdb0> │ │ │ │ - blvc fe3d29ec <__bss_end__@@Base+0xfe32bdb4> │ │ │ │ + blpl fe2d296c <__bss_end__@@Base+0xfe22bdcc> │ │ │ │ + blvs fe352970 <__bss_end__@@Base+0xfe2abdd0> │ │ │ │ + blvc fe3d2974 <__bss_end__@@Base+0xfe32bdd4> │ │ │ │ mrc 6, 5, r4, cr0, cr8, {0} │ │ │ │ vmov.f64 d0, d5 │ │ │ │ vmov.f64 d1, d6 │ │ │ │ @ instruction: 0xf0052b47 │ │ │ │ ldc 15, cr15, [r7, #740] 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d7 │ │ │ │ @ instruction: 0xf7eb0b47 │ │ │ │ - mrc 13, 5, lr, cr0, cr0, {3} │ │ │ │ + cdp 13, 11, cr14, cr0, cr6, {4} │ │ │ │ ldmdavs fp!, {r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 252c5c <__bss_end__@@Base+0x1ac024> │ │ │ │ + blvc 252be4 <__bss_end__@@Base+0x1ac044> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ ldmdavs fp!, {r3, r8, r9, fp, sp, lr}^ │ │ │ │ - blvc 252ca8 <__bss_end__@@Base+0x1ac070> │ │ │ │ - blvc 212ef8 <__bss_end__@@Base+0x16c2c0> │ │ │ │ + blvc 252c30 <__bss_end__@@Base+0x1ac090> │ │ │ │ + blvc 212e80 <__bss_end__@@Base+0x16c2e0> │ │ │ │ stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ ldmdavs r9!, {r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ ldmib r3, {r3, r4, r8, r9, sp, pc}^ │ │ │ │ stmib r1, {r8, r9, sp}^ │ │ │ │ ldmdavs fp!, {r1, r3, r8, r9, sp} │ │ │ │ adcpl pc, r1, #64, 4 │ │ │ │ ldmdavs fp!, {r1, r3, r4, sp, lr} │ │ │ │ sbcscs pc, r1, #64, 4 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, sp, lr} │ │ │ │ addsvs r2, sl, r6, lsl #4 │ │ │ │ andcs r6, r4, #3866624 @ 0x3b0000 │ │ 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r1, r2, r3, sl, lr, pc} │ │ │ │ stm r4, {r0, r1} │ │ │ │ movwcs r0, #3 │ │ │ │ strbcc pc, [r4], #-2247 @ 0xfffff739 @ │ │ │ │ @ instruction: 0xf8c72300 │ │ │ │ movwcs r3, #21568 @ 0x5440 │ │ │ │ ldrtcc pc, [r8], #-2247 @ 0xfffff739 @ │ │ │ │ orrvs pc, r9, #29360128 @ 0x1c00000 │ │ │ │ teqpmi ip, #805306378 @ p-variant is OBSOLETE @ 0x3000000a │ │ │ │ ldrbtmi r4, [sl], #-2785 @ 0xfffff51f │ │ │ │ ldmdavs r8, {r0, r4, r9, sl, lr} │ │ │ │ - stc 7, cr15, [r0, #940] @ 0x3ac │ │ │ │ + ldc 7, cr15, [r8, #940] @ 0x3ac │ │ │ │ @ instruction: 0xf8c74603 │ │ │ │ @ instruction: 0xf8d73434 │ │ │ │ - blcs 24818 │ │ │ │ + blcs 247a0 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ @ instruction: 0xf107e1ac │ │ │ │ @ instruction: 0xf8d7032c │ │ │ │ vst3.8 {d18-d20}, [pc :256], r4 │ │ │ │ ldrmi r6, [r8], -r0, lsl #3 │ │ │ │ - mcrr 7, 14, pc, r4, cr11 @ │ │ │ │ - blcs 28f70 │ │ │ │ + mrrc 7, 14, pc, r8, cr11 @ │ │ │ │ + blcs 28ef8 │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ @ instruction: 0xf107e19e │ │ │ │ @ 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lsl #26 │ │ │ │ + strmi lr, [r3], -r6, lsr #26 │ │ │ │ ldrtcc pc, [r4], #-2247 @ 0xfffff739 @ │ │ │ │ ldrtcc pc, [r4], #-2263 @ 0xfffff729 @ │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ teq r9, r0, lsl #6 │ │ │ │ orrvs pc, r9, #29360128 @ 0x1c00000 │ │ │ │ orrvs pc, r7, #683671552 @ 0x28c00000 │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ msreq CPSR_fs, #-1073741823 @ 0xc0000001 │ │ │ │ ldrtcs pc, [r4], #-2263 @ 0xfffff729 @ │ │ │ │ orrvs pc, r0, pc, asr #8 │ │ │ │ @ instruction: 0xf7eb4618 │ │ │ │ - strmi lr, [r3], -ip, asr #23 │ │ │ │ + strmi lr, [r3], -r0, ror #23 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ @ instruction: 0xe1252300 │ │ │ │ msreq CPSR_fs, #-1073741823 @ 0xc0000001 │ │ │ │ ldrtcs pc, [r4], #-2263 @ 0xfffff729 @ │ │ │ │ orrvs pc, r0, pc, asr #8 │ │ │ │ @ instruction: 0xf7eb4618 │ │ │ │ - @ instruction: 0x4603ebbe │ │ │ │ + @ instruction: 0x4603ebd2 │ │ │ │ suble r2, r0, r0, lsl #22 │ │ │ │ andseq pc, r0, #-1073741823 @ 0xc0000001 │ │ │ │ msreq CPSR_fs, #-1073741823 @ 0xc0000001 │ │ │ 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instruction: 0xf8c7681b │ │ │ │ @@ -20657,18 +20652,18 @@ │ │ │ │ orrsvs pc, lr, #72, 4 @ 0x80000004 │ │ │ │ movweq pc, #4800 @ 0x12c0 @ │ │ │ │ stcle 2, cr4, [r5], {154} @ 0x9a │ │ │ │ ldrtcc pc, [r0], #-2263 @ 0xfffff729 @ │ │ │ │ adcsle r2, r3, r1, lsl #22 │ │ │ │ svclt 0x0000e000 │ │ │ │ ldrteq pc, [r4], #-2263 @ 0xfffff729 @ │ │ │ │ - bl 1bd58ac <__bss_end__@@Base+0x1b2ec74> │ │ │ │ + bl fe0d5834 <__bss_end__@@Base+0xfe02ec94> │ │ │ │ strbcc pc, [r4], #-2263 @ 0xfffff729 @ │ │ │ │ @ instruction: 0xf8d73301 │ │ │ │ - blx a0a1e <__bss_start@@Base+0x4597e> │ │ │ │ + blx a09a6 <__bss_start@@Base+0x4599e> │ │ │ │ svceq 0x00daf303 │ │ │ │ subsne r4, fp, r3, lsl r4 │ │ │ │ @ instruction: 0xf8d7461a │ │ │ │ ldrmi r3, [r3], #-1092 @ 0xfffffbbc │ │ │ │ strtcc pc, [ip], #-2247 @ 0xfffff739 │ │ │ │ strteq pc, [ip], #-2263 @ 0xfffff729 │ │ │ │ @ instruction: 0xf957f002 │ │ │ │ @@ -20681,25 +20676,25 @@ │ │ │ │ @ instruction: 0xf8d7681b │ │ │ │ ldrvs r2, [sl], #-1092 @ 0xfffffbbc │ │ │ │ orrvs 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lsr #22 │ │ │ │ + eor lr, r7, ip, lsr fp │ │ │ │ ldrbtmi r4, [fp], #-2854 @ 0xfffff4da │ │ │ │ @ instruction: 0xf7eb4618 │ │ │ │ - eor lr, r1, r6, lsr #22 │ │ │ │ + eor lr, r1, r6, lsr fp │ │ │ │ ldrbtmi r4, [fp], #-2852 @ 0xfffff4dc │ │ │ │ @ instruction: 0xf7eb4618 │ │ │ │ - ands lr, fp, r0, lsr #22 │ │ │ │ + ands lr, fp, r0, lsr fp │ │ │ │ ldrbtmi r4, [fp], #-2850 @ 0xfffff4de │ │ │ │ @ instruction: 0xf7eb4618 │ │ │ │ - ands lr, r5, sl, lsl fp │ │ │ │ + ands lr, r5, sl, lsr #22 │ │ │ │ ldrbtmi r4, [fp], #-2848 @ 0xfffff4e0 │ │ │ │ @ instruction: 0xf7eb4618 │ │ │ │ - and lr, pc, r4, lsl fp @ │ │ │ │ + and lr, pc, r4, lsr #22 │ │ │ │ ldrbtmi r4, [fp], #-2846 @ 0xfffff4e2 │ │ │ │ @ instruction: 0xf7eb4618 │ │ │ │ - blmi 792a88 <__bss_end__@@Base+0x6ebe50> │ │ │ │ + blmi 792a50 <__bss_end__@@Base+0x6ebeb0> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - bl 255e04 <__bss_end__@@Base+0x1af1cc> │ │ │ │ + bl 655d8c <__bss_end__@@Base+0x5af1ec> │ │ │ │ ldrbtmi r4, [fp], #-2843 @ 0xfffff4e5 │ │ │ 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0xed93697b │ │ │ │ vadd.f64 d7, d6, d6 │ │ │ │ ldmvs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 53960 │ │ │ │ + blvc 538e8 │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf8df2300 │ │ │ │ ldrbtmi r1, [r9], #-1160 @ 0xfffffb78 │ │ │ │ @ instruction: 0xf7ea4608 │ │ │ │ - @ instruction: 0xe008efb6 │ │ │ │ + and lr, r8, lr, asr #31 │ │ │ │ tstpeq ip, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ @ instruction: 0xf8df68ba │ │ │ │ ldrbtmi r1, [r9], #-1144 @ 0xfffffb88 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - movwcs lr, #3608 @ 0xe18 │ │ │ │ + movwcs lr, #3628 @ 0xe2c │ │ │ │ @ instruction: 0xf8df773b │ │ │ │ ldrbtmi r3, [fp], #-1132 @ 0xfffffb94 │ │ │ │ @ instruction: 0xf7eb4618 │ │ │ │ - and lr, r5, r0, ror r8 │ │ │ │ + and lr, r5, r0, lsl #17 │ │ │ │ strbtcc pc, [r0], #-2271 @ 0xfffff721 @ │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - stmda r8!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r8!, {r0, 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0x4603eddc │ │ │ │ + @ instruction: 0x4603edf0 │ │ │ │ tstle r4, r0, lsl #22 │ │ │ │ ldrdcc pc, [r0], r7 │ │ │ │ - blvs 153a8c <__bss_end__@@Base+0xace54> │ │ │ │ + blvs 153a14 <__bss_end__@@Base+0xace74> │ │ │ │ vldr , [r3, #492] @ 0x1ec │ │ │ │ vadd.f64 d7, d6, d4 │ │ │ │ svcvs 0x00bb7b47 │ │ │ │ - blvc 53a5c │ │ │ │ + blvc 539e4 │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r7, r8, r9, sl, fp, sp, lr}^ │ │ │ │ stmibmi ip!, {r8, r9, sp}^ │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - svc 0x0038f7ea │ │ │ │ + svc 0x0050f7ea │ │ │ │ @ instruction: 0xf107e007 │ │ │ │ svcvs 0x00ba031c │ │ │ │ ldrbtmi r4, [r9], #-2536 @ 0xfffff618 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - movwcs lr, #3484 @ 0xd9c │ │ │ │ - blmi ff9b6164 <__bss_end__@@Base+0xff90f52c> │ │ │ │ + movwcs lr, #3504 @ 0xdb0 │ │ │ │ + blmi ff9b60ec <__bss_end__@@Base+0xff90f54c> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - svc 0x00f4f7ea │ │ │ │ + stmda r4, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrbtmi r4, [fp], #-3044 @ 0xfffff41c │ │ │ │ - @ instruction: 0xf7ea4618 │ │ │ │ - blmi fee1444c <__bss_end__@@Base+0xfed6d814> │ │ │ │ + @ instruction: 0xf7eb4618 │ │ │ │ + blmi fee12414 <__bss_end__@@Base+0xfed6b874> │ │ │ │ ldmdavs sl, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ tstpeq ip, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ @ instruction: 0x46182114 │ │ │ │ - stc 7, cr15, [r6, #936]! @ 0x3a8 │ │ │ │ - blcs 29cac │ │ │ │ + ldc 7, cr15, [sl, #936]! @ 0x3a8 │ │ │ │ + blcs 29c34 │ │ │ │ @ instruction: 0xf8d7d10c │ │ │ │ andcs r3, r1, #132 @ 0x84 │ │ │ │ @ instruction: 0xf8d7601a │ │ │ │ ldmdavs fp, {r2, r7, ip, sp} │ │ │ │ - blmi ff669d18 <__bss_end__@@Base+0xff5c30e0> │ │ │ │ + blmi ff669ca0 <__bss_end__@@Base+0xff5c3100> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - svc 0x000af7ea │ │ │ │ + svc 0x0022f7ea │ │ │ │ tstpeq ip, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ ldrdcs pc, [r4], r7 │ │ │ │ ldrbtmi r4, [r9], #-2517 @ 0xfffff62b │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - movwcs lr, #3438 @ 0xd6e │ │ │ │ + movwcs lr, #3458 @ 0xd82 │ │ │ │ @ instruction: 0xf8d7773b │ │ │ │ ldmdavs fp, {r2, r7, ip, sp} │ │ │ │ cmple r2, r1, lsl fp │ │ │ │ ldrbtmi r4, [fp], #-3024 @ 0xfffff430 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - blmi ff4143f0 <__bss_end__@@Base+0xff36d7b8> │ │ │ │ + blmi ff4143b8 <__bss_end__@@Base+0xff36d818> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - svc 0x00bcf7ea │ │ │ │ + svc 0x00ccf7ea │ │ │ │ ldrbtmi r4, [fp], #-3021 @ 0xfffff433 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - blmi ff3543dc <__bss_end__@@Base+0xff2ad7a4> │ │ │ │ + blmi ff3543a4 <__bss_end__@@Base+0xff2ad804> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - svc 0x00b2f7ea │ │ │ │ + svc 0x00c2f7ea │ │ │ │ ldrvc r2, [fp, -r0, lsl #6]! │ │ │ │ stmiapl r3!, {r0, r1, r2, r4, r7, r8, r9, fp, lr}^ │ │ │ │ @ instruction: 0xf107681a │ │ │ │ tstcs r4, ip, lsl r3 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - strmi lr, [r3], -r8, ror #26 │ │ │ │ + @ instruction: 0x4603ed7c │ │ │ │ tstle sp, r0, lsl #22 │ │ │ │ ldrdcc pc, [r4], r7 │ │ │ │ andsvs r2, sl, r1, lsl #4 │ │ │ │ ldrdcc pc, [r4], r7 │ │ │ │ @ instruction: 0x4619681b │ │ │ │ ldrbtmi r4, [fp], #-3007 @ 0xfffff441 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - and lr, r8, ip, asr #29 │ │ │ │ + and lr, r8, r4, ror #29 │ │ │ │ tstpeq ip, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ ldrdcs pc, [r4], r7 │ │ │ │ ldrbtmi r4, [r9], #-2491 @ 0xfffff645 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - movwcs lr, #3374 @ 0xd2e │ │ │ │ + movwcs lr, #3394 @ 0xd42 │ │ │ │ @ instruction: 0xf8d7773b │ │ │ │ ldmdavs fp, {r2, r7, ip, sp} │ │ │ │ andseq pc, r0, #-1073741824 @ 0xc0000000 │ │ │ │ ldrdcc pc, [r4], r7 │ │ │ │ - blmi fed705cc <__bss_end__@@Base+0xfecc9994> │ │ │ │ + blmi fed70554 <__bss_end__@@Base+0xfecc99b4> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - svc 0x007ef7ea │ │ │ │ + svc 0x008ef7ea │ │ │ │ ldrbtmi r4, [fp], #-2995 @ 0xfffff44d │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - blmi 1f54360 <__bss_end__@@Base+0x1ead728> │ │ │ │ + blmi 1f54328 <__bss_end__@@Base+0x1ead788> │ │ │ │ ldmdavs sl, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ tstpeq ip, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ @ instruction: 0x46182114 │ │ │ │ - ldc 7, cr15, [r0, #-936]! @ 0xfffffc58 │ │ │ │ - blcs 29d98 │ │ │ │ + stcl 7, cr15, [r4, #-936] @ 0xfffffc58 │ │ │ │ + blcs 29d20 │ │ │ │ @ instruction: 0xf8d7d109 │ │ │ │ andcs r3, r2, #136 @ 0x88 │ │ │ │ - blmi feab0600 <__bss_end__@@Base+0xfea099c8> │ │ │ │ + blmi feab0588 <__bss_end__@@Base+0xfea099e8> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - svc 0x0064f7ea │ │ │ │ + svc 0x0074f7ea │ │ │ │ @ instruction: 0xf107e008 │ │ │ │ @ instruction: 0xf8d7031c │ │ │ │ stmibmi r6!, {r3, r7, sp} │ │ │ │ @ instruction: 0x46184479 │ │ │ │ - ldcl 7, cr15, [sl], #936 @ 0x3a8 │ │ │ │ + stc 7, cr15, [lr, #-936] @ 0xfffffc58 │ │ │ │ ldrvc r2, [fp, -r0, lsl #6]! │ │ │ │ teqpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ ldrbtmi r4, [sl], #-2722 @ 0xfffff55e │ │ │ │ @ instruction: 0x46184611 │ │ │ │ - cdp 7, 3, cr15, cr10, cr10, {7} │ │ │ │ + cdp 7, 5, cr15, cr2, cr10, {7} │ │ │ │ ldrbtvs r4, [fp], #1539 @ 0x603 │ │ │ │ ldrdcc pc, [r8], r7 │ │ │ │ - blcs 72640 <__bss_start@@Base+0x175a0> │ │ │ │ - blmi fe78cb00 <__bss_end__@@Base+0xfe6e5ec8> │ │ │ │ + blcs 725c8 <__bss_start@@Base+0x175c0> │ │ │ │ + blmi fe78ca88 <__bss_end__@@Base+0xfe6e5ee8> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - svc 0x0044f7ea │ │ │ │ + svc 0x0054f7ea │ │ │ │ stmiapl r3!, {r0, r5, r6, r8, r9, fp, lr}^ │ │ │ │ @ instruction: 0xf107681a │ │ │ │ tstcs r4, ip, lsl r3 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - @ instruction: 0x4603ecfc │ │ │ │ + @ instruction: 0x4603ed10 │ │ │ │ andle r2, r7, r0, lsl #22 │ │ │ │ tstpeq ip, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - @ instruction: 0x4603ee10 │ │ │ │ + strmi lr, [r3], -r8, lsr #28 │ │ │ │ ldmdale sp, {r0, r8, r9, fp, sp} │ │ │ │ ldrdcs pc, [ip], r7 │ │ │ │ ldrbtmi r4, [fp], #-2960 @ 0xfffff470 │ │ │ │ @ instruction: 0x461d4614 │ │ │ │ eorvs ip, r0, pc, lsl #26 │ │ │ │ adcvs r6, r2, r1, rrx │ │ │ │ ldclvs 0, cr6, [fp], #908 @ 0x38c │ │ │ │ tstcs r1, r5, lsr #4 │ │ │ │ ldrbtmi r4, [r8], #-2187 @ 0xfffff775 │ │ │ │ - cdp 7, 9, cr15, cr0, cr10, {7} │ │ │ │ + cdp 7, 10, cr15, cr8, cr10, {7} │ │ │ │ ldrdcs pc, [ip], r7 │ │ │ │ ldrbtmi r4, [fp], #-2953 @ 0xfffff477 │ │ │ │ @ instruction: 0x461d4614 │ │ │ │ eorvs ip, r0, pc, lsl #26 │ │ │ │ adcvs r6, r2, r1, rrx │ │ │ │ ands r6, r0, r3, ror #1 │ │ │ │ tstpeq ip, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ ldrdcs pc, [ip], r7 │ │ │ │ ldrbtmi r4, [r9], #-2435 @ 0xfffff67d │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - @ instruction: 0xf8d7ecaa │ │ │ │ - blmi fe06088c <__bss_end__@@Base+0xfdfb9c54> │ │ │ │ + @ instruction: 0xf8d7ecbe │ │ │ │ + blmi fe060814 <__bss_end__@@Base+0xfdfb9c74> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ea6cf8 │ │ │ │ - movwcs lr, #3738 @ 0xe9a │ │ │ │ + movwcs lr, #3762 @ 0xeb2 │ │ │ │ and r7, r6, fp, lsr r7 │ │ │ │ andscs r6, ip, #64256 @ 0xfb00 │ │ │ │ ldmdami ip!, {r0, r8, sp}^ │ │ │ │ @ instruction: 0xf7ea4478 │ │ │ │ - ldmdbvs fp!, {r1, r3, r5, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ - blvc d3ccc <__bss_end__@@Base+0x2d094> │ │ │ │ - blvc 53ca0 │ │ │ │ + ldmdbvs fp!, {r1, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + blvc d3c54 <__bss_end__@@Base+0x2d0b4> │ │ │ │ + blvc 53c28 │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ ldmvs r9!, {r1, r8, r9, sp}^ │ │ │ │ ldrdeq lr, [r0, -r1] │ │ │ │ ldmib r4, {r2, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ldmdbvs lr!, {r8, sl, lr} │ │ │ │ stmdbhi r0, {r1, r2, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ ldmib r6, {r1, r2, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ @@ -21538,124 +21533,124 @@ │ │ │ │ stmib sp, {r3, r8, r9, fp, sp, pc}^ │ │ │ │ stmib sp, {r1, r2, r8, fp, pc}^ │ │ │ │ stmib sp, {r2, r8, sl, lr}^ │ │ │ │ stmib sp, {r1, r8}^ │ │ │ │ ldmib r7, {r8, r9, sp}^ │ │ │ │ stmdbmi fp!, {r8, r9, sp}^ │ │ │ │ ldclvs 4, cr4, [r8], #484 @ 0x1e4 │ │ │ │ - cdp 7, 6, cr15, cr10, cr10, {7} │ │ │ │ + cdp 7, 8, cr15, cr2, cr10, {7} │ │ │ │ @ instruction: 0x3090f8d7 │ │ │ │ - blcs 72e38 <__bss_start@@Base+0x17d98> │ │ │ │ + blcs 72dc0 <__bss_start@@Base+0x17db8> │ │ │ │ ldmdbvs fp!, {r2, r4, r8, ip, lr, pc}^ │ │ │ │ strmi lr, [r6, #-2515] @ 0xfffff62d │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ ldmvs r9!, {r1, r2, r8, r9, sp} │ │ │ │ ldrdeq lr, [r0, -r1] │ │ │ │ smlabteq r2, sp, r9, lr │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ strtmi r4, [fp], -r2, lsr #12 │ │ │ │ ldrbtmi r4, [r9], #-2399 @ 0xfffff6a1 │ │ │ │ @ instruction: 0xf7ea6cf8 │ │ │ │ - ands lr, r3, r2, asr lr │ │ │ │ + ands lr, r3, sl, ror #28 │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ldmdbvs fp!, {r2, r8, sl, lr} │ │ │ │ movwcs lr, #18899 @ 0x49d3 │ │ │ │ ldmib r1, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ stmib sp, {r8}^ │ │ │ │ stmib sp, {r1, r8}^ │ │ │ │ strtmi r2, [r2], -r0, lsl #6 │ │ │ │ ldmdbmi r6, {r0, r1, r3, r5, r9, sl, lr}^ │ │ │ │ ldclvs 4, cr4, [r8], #484 @ 0x1e4 │ │ │ │ - cdp 7, 3, cr15, cr12, cr10, {7} │ │ │ │ + cdp 7, 5, cr15, cr4, cr10, {7} │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf8d74504 │ │ │ │ ldmib r3, {r7, ip, sp}^ │ │ │ │ svcvs 0x00b92304 │ │ │ │ ldrdeq lr, [r0, -r1] │ │ │ │ smlabteq r2, sp, r9, lr │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ strtmi r4, [fp], -r2, lsr #12 │ │ │ │ ldrbtmi r4, [r9], #-2380 @ 0xfffff6b4 │ │ │ │ @ instruction: 0xf7ea6cf8 │ │ │ │ - ldclvs 14, cr14, [r8], #160 @ 0xa0 │ │ │ │ - mcrr 7, 14, pc, r6, cr10 @ │ │ │ │ + ldclvs 14, cr14, [r8], #256 @ 0x100 │ │ │ │ + mrrc 7, 14, pc, sl, cr10 @ │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r4, asr #14 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - andeq r0, r4, r0, lsr #2 │ │ │ │ - andeq r8, r3, r2, lsr lr │ │ │ │ - andeq r8, r3, lr, lsl r6 │ │ │ │ - strdeq r0, [r0], -ip │ │ │ │ - andeq r8, r3, r8, lsl r6 │ │ │ │ - andeq r8, r3, r8, lsr #12 │ │ │ │ - andeq r8, r3, ip, lsl r6 │ │ │ │ - @ instruction: 0x000385b6 │ │ │ │ - andeq r8, r3, r6, asr #11 │ │ │ │ - andeq r8, r3, lr, ror #11 │ │ │ │ - andeq r8, r3, r4, asr r5 │ │ │ │ - andeq r8, r3, r8, ror #10 │ │ │ │ - andeq r8, r3, r8, asr #11 │ │ │ │ - strdeq r8, [r3], -r6 │ │ │ │ - andeq r8, r3, sl, lsl #10 │ │ │ │ - andeq r8, r3, r2, lsr #11 │ │ │ │ - andeq r8, r3, r0, ror r4 │ │ │ │ - andeq r8, r3, r4, lsl #9 │ │ │ │ - andeq r8, r3, ip, asr #10 │ │ │ │ - andeq r8, r3, r6, ror r5 │ │ │ │ - andeq r7, r3, r4, lsr #31 │ │ │ │ - andeq r8, r3, sl, asr r5 │ │ │ │ - muleq r3, ip, r3 │ │ │ │ - andeq r8, r3, ip, lsr #7 │ │ │ │ - andeq r8, r3, r8, lsr #10 │ │ │ │ - andeq r8, r3, sl, lsr r3 │ │ │ │ - andeq r8, r3, sl, asr #6 │ │ │ │ - strdeq r8, [r3], -r4 │ │ │ │ - ldrdeq r8, [r3], -r6 │ │ │ │ - andeq r8, r3, r6, ror #5 │ │ │ │ - andeq r8, r3, r6, asr #9 │ │ │ │ - andeq r8, r3, r8, ror #4 │ │ │ │ - andeq r8, r3, r8, ror r2 │ │ │ │ - muleq r3, r8, r4 │ │ │ │ - strdeq r8, [r3], -r2 │ │ │ │ - andeq r8, r3, r6, lsl #4 │ │ │ │ - andeq r8, r3, sl, asr r4 │ │ │ │ - andeq r8, r3, ip, ror r4 │ │ │ │ - @ instruction: 0x000381ba │ │ │ │ - andeq r8, r3, r2, ror r4 │ │ │ │ - andeq r8, r3, r0, lsr r4 │ │ │ │ - andeq r8, r3, lr, ror #2 │ │ │ │ - andeq r8, r3, r4, asr r4 │ │ │ │ - andeq r8, r3, r8, lsr r4 │ │ │ │ - andeq r8, r3, lr, lsl #2 │ │ │ │ - andeq r8, r3, r4, asr #8 │ │ │ │ - andeq r8, r3, r2, ror r4 │ │ │ │ - strdeq r8, [r3], -r0 │ │ │ │ - andeq r7, r3, r6, lsr #24 │ │ │ │ - andeq r8, r3, lr, ror #9 │ │ │ │ - andeq r8, r3, ip, lsl r5 │ │ │ │ - andeq r8, r3, r6, lsr r5 │ │ │ │ - andeq r8, r3, ip, asr r5 │ │ │ │ - andeq r8, r3, r2, ror r4 │ │ │ │ - andeq r7, r3, r6, lsr #23 │ │ │ │ - andeq r8, r3, r4, lsl r5 │ │ │ │ + muleq r4, r8, r1 │ │ │ │ + andeq r8, r3, sl, lsr #27 │ │ │ │ + muleq r3, r6, r5 │ │ │ │ + strdeq r0, [r0], -r4 │ │ │ │ + muleq r3, r0, r5 │ │ │ │ + andeq r8, r3, r0, lsr #11 │ │ │ │ + muleq r3, r4, r5 │ │ │ │ + andeq r8, r3, lr, lsr #10 │ │ │ │ + andeq r8, r3, lr, lsr r5 │ │ │ │ + andeq r8, r3, r6, ror #10 │ │ │ │ + andeq r8, r3, ip, asr #9 │ │ │ │ + andeq r8, r3, r0, ror #9 │ │ │ │ + andeq r8, r3, r0, asr #10 │ │ │ │ + andeq r8, r3, lr, ror #8 │ │ │ │ + andeq r8, r3, r2, lsl #9 │ │ │ │ andeq r8, r3, sl, lsl r5 │ │ │ │ - andeq r8, r3, ip, lsl r5 │ │ │ │ - andeq r7, r3, r0, asr #22 │ │ │ │ - andeq r8, r3, sl, lsr #10 │ │ │ │ - andeq r8, r3, r4, lsl r5 │ │ │ │ - andeq r8, r3, sl, lsr #10 │ │ │ │ - andeq r8, r3, r2, lsr #10 │ │ │ │ - andeq r8, r3, r6, lsl #10 │ │ │ │ - andeq r8, r3, r2, lsr #10 │ │ │ │ - andeq r8, r3, r8, lsl r5 │ │ │ │ - andeq r8, r3, ip, lsl r5 │ │ │ │ + andeq r8, r3, r8, ror #7 │ │ │ │ + strdeq r8, [r3], -ip │ │ │ │ + andeq r8, r3, r4, asr #9 │ │ │ │ + andeq r8, r3, lr, ror #9 │ │ │ │ + andeq r7, r3, ip, lsl pc │ │ │ │ + ldrdeq r8, [r3], -r2 │ │ │ │ + andeq r8, r3, r4, lsl r3 │ │ │ │ + andeq r8, r3, r4, lsr #6 │ │ │ │ + andeq r8, r3, r0, lsr #9 │ │ │ │ + @ instruction: 0x000382b2 │ │ │ │ + andeq r8, r3, r2, asr #5 │ │ │ │ + andeq r8, r3, ip, ror #8 │ │ │ │ + andeq r8, r3, lr, asr #4 │ │ │ │ + andeq r8, r3, lr, asr r2 │ │ │ │ + andeq r8, r3, lr, lsr r4 │ │ │ │ + andeq r8, r3, r0, ror #3 │ │ │ │ + strdeq r8, [r3], -r0 │ │ │ │ + andeq r8, r3, r0, lsl r4 │ │ │ │ + andeq r8, r3, sl, ror #2 │ │ │ │ + andeq r8, r3, lr, ror r1 │ │ │ │ + ldrdeq r8, [r3], -r2 │ │ │ │ strdeq r8, [r3], -r4 │ │ │ │ - andeq r8, r3, sl, lsr r5 │ │ │ │ - andeq r8, r3, r0, ror #10 │ │ │ │ - muleq r3, lr, r5 │ │ │ │ + andeq r8, r3, r2, lsr r1 │ │ │ │ + andeq r8, r3, sl, ror #7 │ │ │ │ + andeq r8, r3, r8, lsr #7 │ │ │ │ + andeq r8, r3, r6, ror #1 │ │ │ │ + andeq r8, r3, ip, asr #7 │ │ │ │ + @ instruction: 0x000383b0 │ │ │ │ + andeq r8, r3, r6, lsl #1 │ │ │ │ + @ instruction: 0x000383bc │ │ │ │ + andeq r8, r3, sl, ror #7 │ │ │ │ + andeq r8, r3, r8, ror #8 │ │ │ │ + muleq r3, lr, fp │ │ │ │ + andeq r8, r3, r6, ror #8 │ │ │ │ + muleq r3, r4, r4 │ │ │ │ + andeq r8, r3, lr, lsr #9 │ │ │ │ + ldrdeq r8, [r3], -r4 │ │ │ │ + andeq r8, r3, sl, ror #7 │ │ │ │ + andeq r7, r3, lr, lsl fp │ │ │ │ + andeq r8, r3, ip, lsl #9 │ │ │ │ + muleq r3, r2, r4 │ │ │ │ + muleq r3, r4, r4 │ │ │ │ + @ instruction: 0x00037ab8 │ │ │ │ + andeq r8, r3, r2, lsr #9 │ │ │ │ + andeq r8, r3, ip, lsl #9 │ │ │ │ + andeq r8, r3, r2, lsr #9 │ │ │ │ + muleq r3, sl, r4 │ │ │ │ + andeq r8, r3, lr, ror r4 │ │ │ │ + muleq r3, sl, r4 │ │ │ │ + muleq r3, r0, r4 │ │ │ │ + muleq r3, r4, r4 │ │ │ │ + andeq r8, r3, ip, ror #8 │ │ │ │ + @ instruction: 0x000384b2 │ │ │ │ + ldrdeq r8, [r3], -r8 @ │ │ │ │ + andeq r8, r3, r6, lsl r5 │ │ │ │ strhtlt fp, [r2], #80 @ 0x50 │ │ │ │ @ instruction: 0xf507af02 │ │ │ │ @ instruction: 0xf5a474c0 │ │ │ │ strhtvs r7, [r0], -sl │ │ │ │ sbcvc pc, r0, r7, lsl #10 │ │ │ │ adcsvc pc, ip, r0, lsr #11 │ │ │ │ @ instruction: 0xf5076001 │ │ │ │ @@ -21666,66 +21661,66 @@ │ │ │ │ @ instruction: 0xf8df6013 │ │ │ │ ldrbtmi r4, [ip], #-1412 @ 0xfffffa7c │ │ │ │ @ instruction: 0xf8c72300 │ │ │ │ @ instruction: 0xf5073178 │ │ │ │ @ instruction: 0xf5a373c0 │ │ │ │ @ instruction: 0xf8df72ac │ │ │ │ ldrbtmi r3, [fp], #-1396 @ 0xfffffa8c │ │ │ │ - blgt 3ea118 <__bss_end__@@Base+0x3434e0> │ │ │ │ + blgt 3ea0a0 <__bss_end__@@Base+0x343500> │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ bicvc pc, r0, #29360128 @ 0x1c00000 │ │ │ │ adcsvc pc, r4, #683671552 @ 0x28c00000 │ │ │ │ strbcc pc, [r0, #-2271]! @ 0xfffff721 @ │ │ │ │ @ instruction: 0x4615447b │ │ │ │ stm r5, {r0, r1, r2, r3, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0xf507000f │ │ │ │ @ instruction: 0xf5a373c0 │ │ │ │ @ instruction: 0xf8df73b8 │ │ │ │ ldrbtmi r2, [sl], #-1360 @ 0xfffffab0 │ │ │ │ muleq r3, r2, r8 │ │ │ │ andeq lr, r3, r3, lsl #17 │ │ │ │ andmi pc, r4, r0, asr #4 │ │ │ │ - ldcl 7, cr15, [r4, #-936] @ 0xfffffc58 │ │ │ │ + stcl 7, cr15, [ip, #-936]! @ 0xfffffc58 │ │ │ │ @ instruction: 0xf8c74603 │ │ │ │ @ instruction: 0xf5073174 │ │ │ │ @ instruction: 0xf5a373c0 │ │ │ │ andcs r7, r0, #156, 6 @ 0x70000002 │ │ │ │ @ instruction: 0xf8d7701a │ │ │ │ @ instruction: 0xf8df2174 │ │ │ │ ldrbtmi r3, [fp], #-1320 @ 0xfffffad8 │ │ │ │ @ instruction: 0x46194610 │ │ │ │ @ instruction: 0x461a237e │ │ │ │ - stc 7, cr15, [r4], {234} @ 0xea │ │ │ │ + ldc 7, cr15, [ip], {234} @ 0xea │ │ │ │ bicvc pc, r0, #29360128 @ 0x1c00000 │ │ │ │ @ instruction: 0x73bef5a3 │ │ │ │ movwcc r6, #34843 @ 0x881b │ │ │ │ eoreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ @ instruction: 0xf8d74619 │ │ │ │ @ instruction: 0xf0070174 │ │ │ │ @ instruction: 0xf507ffdd │ │ │ │ @ instruction: 0xf5a373c0 │ │ │ │ andcs r7, r0, #156, 6 @ 0x70000002 │ │ │ │ @ instruction: 0xf8d7701a │ │ │ │ @ instruction: 0xf8df2174 │ │ │ │ ldrbtmi r3, [fp], #-1264 @ 0xfffffb10 │ │ │ │ @ instruction: 0x46194610 │ │ │ │ @ instruction: 0x461a237c │ │ │ │ - stcl 7, cr15, [r6], #-936 @ 0xfffffc58 │ │ │ │ + ldcl 7, cr15, [lr], #-936 @ 0xfffffc58 │ │ │ │ bicvc pc, r0, #29360128 @ 0x1c00000 │ │ │ │ @ instruction: 0x73bef5a3 │ │ │ │ @ instruction: 0xf107681b │ │ │ │ @ instruction: 0x46190218 │ │ │ │ ldrsbeq pc, [r4, #-135]! @ 0xffffff79 @ │ │ │ │ @ instruction: 0xffc0f007 │ │ │ │ ldrsbcs pc, [r4, #-135]! @ 0xffffff79 @ │ │ │ │ strbcc pc, [r4], #2271 @ 0x8df @ │ │ │ │ @ instruction: 0x4610447b │ │ │ │ cmncs lr, #26214400 @ 0x1900000 │ │ │ │ @ instruction: 0xf7ea461a │ │ │ │ - @ instruction: 0xf107ec50 │ │ │ │ + @ instruction: 0xf107ec68 │ │ │ │ @ instruction: 0xf5070310 │ │ │ │ @ instruction: 0xf5a272c0 │ │ │ │ @ instruction: 0xf50772be │ │ │ │ @ instruction: 0xf5a171c0 │ │ │ │ @ instruction: 0x200071bc │ │ │ │ ldmdavs r2, {ip, pc} │ │ │ │ @ instruction: 0xf8d76809 │ │ │ │ @@ -21735,24 +21730,24 @@ │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ @ instruction: 0xf507e22c │ │ │ │ @ instruction: 0xf5a373c0 │ │ │ │ andcs r7, r0, #156, 6 @ 0x70000002 │ │ │ │ @ instruction: 0xf8df701a │ │ │ │ ldrbtmi r3, [fp], #-1148 @ 0xfffffb84 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - and lr, r5, sl, asr #26 │ │ │ │ + and lr, r5, sl, asr sp │ │ │ │ ldrbtcc pc, [r0], #-2271 @ 0xfffff721 @ │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - stcl 7, cr15, [r2, #-936] @ 0xfffffc58 │ │ │ │ + ldcl 7, cr15, [r2, #-936] @ 0xfffffc58 │ │ │ │ strbtcc pc, [r8], #-2271 @ 0xfffff721 @ │ │ │ │ ldmdavs sl, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ movteq pc, #33031 @ 0x8107 @ │ │ │ │ ldrmi r2, [r8], -r8, lsr #2 │ │ │ │ - b ffe569a0 <__bss_end__@@Base+0xffdafd68> │ │ │ │ - blcs 2a208 │ │ │ │ + bl 356928 <__bss_end__@@Base+0x2afd88> │ │ │ │ + blcs 2a190 │ │ │ │ movwcs sp, #236 @ 0xec │ │ │ │ cmnpcc ip, r7, asr #17 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf8c72300 │ │ │ │ mvns r3, r8, ror r1 │ │ │ │ bicvc pc, r0, #29360128 @ 0x1c00000 │ │ │ │ addsvc pc, ip, #683671552 @ 0x28c00000 │ │ │ │ ldrsbcc pc, [ip, #-135]! @ 0xffffff79 @ │ │ │ │ @@ -21761,17 +21756,17 @@ │ │ │ │ bicvc pc, r0, #29360128 @ 0x1c00000 │ │ │ │ bicvc pc, r0, #683671552 @ 0x28c00000 │ │ │ │ @ instruction: 0xf103681b │ │ │ │ @ instruction: 0xf1070210 │ │ │ │ @ instruction: 0xf8df0348 │ │ │ │ ldrbtmi r1, [r9], #-1056 @ 0xfffffbe0 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - @ instruction: 0xf8c7eab6 │ │ │ │ + @ instruction: 0xf8c7eaca │ │ │ │ @ instruction: 0xf8d70170 │ │ │ │ - blcs 65008 <__bss_start@@Base+0x9f68> │ │ │ │ + blcs 64f90 <__bss_start@@Base+0x9f88> │ │ │ │ movwcs sp, #4355 @ 0x1103 │ │ │ │ cmnpcc r8, r7, asr #17 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf507e008 │ │ │ │ @ instruction: 0xf5a373c0 │ │ │ │ @ instruction: 0xf8d7729c │ │ │ │ ldrmi r3, [r3], #-380 @ 0xfffffe84 │ │ │ │ andsvc r2, sl, r0, lsl #4 │ │ │ │ @@ -21788,64 +21783,64 @@ │ │ │ │ @ instruction: 0xf103681b │ │ │ │ @ instruction: 0xf5070108 │ │ │ │ @ instruction: 0xf5a373c0 │ │ │ │ ldmdavs fp, {r6, r7, r8, r9, ip, sp, lr} │ │ │ │ subeq pc, r8, r7, lsl #2 │ │ │ │ strmi r9, [fp], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [r9], #-2540 @ 0xfffff614 │ │ │ │ - b 1fd6a54 <__bss_end__@@Base+0x1f2fe1c> │ │ │ │ + b fe4d69dc <__bss_end__@@Base+0xfe42fe3c> │ │ │ │ rsbseq pc, r0, #-1073741823 @ 0xc0000001 │ │ │ │ bicvc pc, r0, #29360128 @ 0x1c00000 │ │ │ │ bicvc pc, r0, #683671552 @ 0x28c00000 │ │ │ │ ldmdavs r8, {r0, r4, r9, sl, lr} │ │ │ │ - blx 1714ace <__bss_end__@@Base+0x166de96> │ │ │ │ - blcs 2a2d0 │ │ │ │ + blx 1714a56 <__bss_end__@@Base+0x166deb6> │ │ │ │ + blcs 2a258 │ │ │ │ @ instruction: 0xf107d122 │ │ │ │ @ instruction: 0x46190370 │ │ │ │ ldrbtmi r4, [fp], #-3043 @ 0xfffff41d │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - blmi ff8d3ad0 <__bss_end__@@Base+0xff82ce98> │ │ │ │ + blmi ff8d3ab8 <__bss_end__@@Base+0xff82cf18> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - stcl 7, cr15, [r4], {234} @ 0xea │ │ │ │ - blmi ff850af4 <__bss_end__@@Base+0xff7a9ebc> │ │ │ │ + ldcl 7, cr15, [r4], {234} @ 0xea │ │ │ │ + blmi ff850a7c <__bss_end__@@Base+0xff7a9edc> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - ldc 7, cr15, [lr], #936 @ 0x3a8 │ │ │ │ + stcl 7, cr15, [lr], {234} @ 0xea │ │ │ │ stmiapl r3!, {r3, r4, r6, r7, r8, r9, fp, lr}^ │ │ │ │ @ instruction: 0xf107681a │ │ │ │ @ instruction: 0x21280348 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - @ instruction: 0x4603ea76 │ │ │ │ + strmi lr, [r3], -sl, lsl #21 │ │ │ │ rscle r2, lr, r0, lsl #22 │ │ │ │ @ instruction: 0xf8c72300 │ │ │ │ and r3, r2, ip, ror r1 │ │ │ │ @ instruction: 0xf8c72301 │ │ │ │ @ instruction: 0xf5073178 │ │ │ │ @ instruction: 0xf5a373c0 │ │ │ │ @ instruction: 0xf8d7729c │ │ │ │ ldrmi r3, [r3], #-380 @ 0xfffffe84 │ │ │ │ - blcs 836b90 <__bss_end__@@Base+0x78ff58> │ │ │ │ + blcs 836b18 <__bss_end__@@Base+0x78ff78> │ │ │ │ @ instruction: 0xf8d7d109 │ │ │ │ movwcc r3, #4476 @ 0x117c │ │ │ │ sbcvc pc, r0, #29360128 @ 0x1c00000 │ │ │ │ addsvc pc, ip, #679477248 @ 0x28800000 │ │ │ │ - blcs befe84 <__bss_end__@@Base+0xb4924c> │ │ │ │ + blcs befe0c <__bss_end__@@Base+0xb4926c> │ │ │ │ @ instruction: 0xf507d10a │ │ │ │ @ instruction: 0xf5a373c0 │ │ │ │ @ instruction: 0xf8d7729c │ │ │ │ ldrmi r3, [r3], #-380 @ 0xfffffe84 │ │ │ │ - blcs 36bb8 │ │ │ │ + blcs 36b40 │ │ │ │ adcshi pc, r0, r0, asr #32 │ │ │ │ cmppeq r0, r7, lsl #2 @ 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r0, lsl #18 │ │ │ │ + and lr, r6, r8, lsl r9 │ │ │ │ cmpcs r6, #3522560 @ 0x35c000 │ │ │ │ ldrbtmi r4, [r9], #-2452 @ 0xfffff66c │ │ │ │ @ instruction: 0xf7ea4608 │ │ │ │ - ldc 8, cr14, [r7, #992] @ 0x3e0 │ │ │ │ + @ instruction: 0xed97e910 │ │ │ │ @ instruction: 0xeeb57b54 │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ strle pc, [fp, #-2576] @ 0xfffff5f0 │ │ │ │ - blvc 1554750 <__bss_end__@@Base+0x14adb18> │ │ │ │ - blvc 1214bbc <__bss_end__@@Base+0x116df84> │ │ │ │ - blcs 614248 <__bss_end__@@Base+0x56d610> │ │ │ │ + blvc 15546d8 <__bss_end__@@Base+0x14adb38> │ │ │ │ + blvc 1214b44 <__bss_end__@@Base+0x116dfa4> │ │ │ │ + blcs 6141d0 <__bss_end__@@Base+0x56d630> │ │ │ │ ldrbtmi r4, [r9], #-2444 @ 0xfffff674 │ │ │ │ @ instruction: 0xf7ea4608 │ │ │ │ - and lr, r6, r6, ror #17 │ │ │ │ + strd lr, [r6], -lr @ │ │ │ │ cmpcs r4, #3522560 @ 0x35c000 │ │ │ │ ldrbtmi r4, [r9], #-2441 @ 0xfffff677 │ │ │ │ @ instruction: 0xf7ea4608 │ │ │ │ - @ instruction: 0xf8d7e8de │ │ │ │ + @ instruction: 0xf8d7e8f6 │ │ │ │ ldmibvs fp, {r2, r4, r7, r8, ip, sp}^ │ │ │ │ tstle r7, r1, lsl #22 │ │ │ │ cmpcs sl, #3522560 @ 0x35c000 │ │ │ │ ldrbtmi r4, [r9], #-2436 @ 0xfffff67c │ │ │ │ @ instruction: 0xf7ea4608 │ │ │ │ - ldrd lr, [r6], -r2 │ │ │ │ + and lr, r6, sl, ror #17 │ │ │ │ cmpcs r8, #3522560 @ 0x35c000 │ │ │ │ ldrbtmi r4, [r9], #-2433 @ 0xfffff67f │ │ │ │ @ instruction: 0xf7ea4608 │ │ │ │ - ldmib r7, {r1, r3, r6, r7, fp, sp, lr, pc}^ │ │ │ │ + ldmib r7, {r1, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ ldmdbmi pc!, {r1, r5, r6, r8, r9, sp}^ @ │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - stmia r2, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm sl, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [fp], #-2941 @ 0xfffff483 │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - ldmib r7, {r1, r3, r7, r8, fp, sp, lr, pc}^ │ │ │ │ + ldmib r7, {r1, r3, r4, r7, r8, fp, sp, lr, pc}^ │ │ │ │ ldmib r7, {r3, r4, r5, r8}^ │ │ │ │ stmib sp, {r3, r6, r8, r9, sp}^ │ │ │ │ strmi r2, [r2], -r0, lsl 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│ │ mrrc 1, 6, r0, r3, cr4 │ │ │ │ ldmdami r8, {r0, r1, r2, r4, r8, r9, fp, sp}^ │ │ │ │ @ instruction: 0xf7ea4478 │ │ │ │ - and lr, sp, r8, ror #16 │ │ │ │ - blvc 1154864 <__bss_end__@@Base+0x10adc2c> │ │ │ │ - blvs 1154888 <__bss_end__@@Base+0x10adc50> │ │ │ │ - blvc 1d4aac <__bss_end__@@Base+0x12de74> │ │ │ │ + and lr, sp, r0, lsl #17 │ │ │ │ + blvc 11547ec <__bss_end__@@Base+0x10adc4c> │ │ │ │ + blvs 1154810 <__bss_end__@@Base+0x10adc70> │ │ │ │ + blvc 1d4a34 <__bss_end__@@Base+0x12de94> │ │ │ │ msreq SPSR_s, r7, lsl #2 │ │ │ │ - blcs 614364 <__bss_end__@@Base+0x56d72c> │ │ │ │ + blcs 6142ec <__bss_end__@@Base+0x56d74c> │ │ │ │ ldrbtmi r4, [r8], #-2129 @ 0xfffff7af │ │ │ │ - ldmda r8, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - blvc dd4880 <__bss_end__@@Base+0xd2dc48> │ │ │ │ - blvc ff054cfc <__bss_end__@@Base+0xfefae0c4> │ │ │ │ - blx 454df0 <__bss_end__@@Base+0x3ae1b8> │ │ │ │ + ldmda r0!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blvc dd4808 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instruction: 0x46084479 │ │ │ │ - ldmda r4, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda ip!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldmib r7, {r1, r2, sp, lr, pc}^ │ │ │ │ ldmdbmi r1!, {r1, r2, r4, r6, r8, r9, sp} │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - stmda ip, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blvc 1554918 <__bss_end__@@Base+0x14adce0> │ │ │ │ - blvc ff054d94 <__bss_end__@@Base+0xfefae15c> │ │ │ │ - blx 454e88 <__bss_end__@@Base+0x3ae250> │ │ │ │ + stmda r4!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blvc 15548a0 <__bss_end__@@Base+0x14add00> │ │ │ │ + blvc ff054d1c <__bss_end__@@Base+0xfefae17c> │ │ │ │ + blx 454e10 <__bss_end__@@Base+0x3ae270> │ │ │ │ ldc 5, cr13, [r7, #44] @ 0x2c │ │ │ │ @ instruction: 0xeeb17b54 │ │ │ │ mrrc 11, 4, r7, r3, cr7 │ │ │ │ stmdbmi r9!, {r0, r1, r2, r4, r8, r9, fp, sp} │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - svc 0x00faf7e9 │ │ │ │ + ldmda r2, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldmib r7, {r1, r2, sp, lr, pc}^ │ │ │ │ stmdbmi r6!, {r2, r4, r6, r8, r9, sp} │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - svc 0x00f2f7e9 │ │ │ │ + stmda sl, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x3194f8d7 │ │ │ │ - blcs 73a60 <__bss_start@@Base+0x189c0> │ │ │ │ + blcs 739e8 <__bss_start@@Base+0x189e0> │ │ │ │ ldmib r7, {r1, r2, r6, r8, ip, lr, pc}^ │ │ │ │ stmdbmi r1!, {r1, r3, r4, r6, r8, r9, sp} │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - svc 0x00e6f7e9 │ │ │ │ + svc 0x00fef7e9 │ │ │ │ svclt 0x0000e045 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcsmi r7, r7, r0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ addsmi r4, pc, r0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ - andeq r8, r3, r6, ror #2 │ │ │ │ - andeq r8, r3, r2, asr r1 │ │ │ │ - andeq r8, r3, r2, asr r1 │ │ │ │ - andeq r8, r3, lr, lsr r1 │ │ │ │ - andeq r8, r3, r2, asr #2 │ │ │ │ + ldrdeq r8, [r3], -lr │ │ │ │ + andeq r8, r3, sl, asr #1 │ │ │ │ + andeq r8, r3, sl, asr #1 │ │ │ │ + strheq r8, [r3], -r6 │ │ │ │ + strheq r8, [r3], -sl │ │ │ │ + strheq r8, [r3], -r6 │ │ │ │ + ldrdeq r8, [r3], -r6 │ │ │ │ + andeq r8, r3, r0, lsl #2 │ │ │ │ + andeq r8, r3, r6, lsl #2 │ │ │ │ + andeq r8, r3, ip, lsl #2 │ │ │ │ + andeq r8, r3, r6, lsl r1 │ │ │ │ + andeq r8, r3, r0, lsr #2 │ │ │ │ + andeq r8, r3, sl, lsr #2 │ │ │ │ + andeq r8, r3, r4, lsr r1 │ │ │ │ + andeq r8, r3, ip, lsr #2 │ │ │ │ + andeq r8, r3, sl, lsr r1 │ │ │ │ andeq r8, r3, lr, lsr r1 │ │ │ │ - andeq r8, r3, lr, asr r1 │ │ │ │ - andeq r8, r3, r8, lsl #3 │ │ │ │ - andeq r8, r3, lr, lsl #3 │ │ │ │ - muleq r3, r4, r1 │ │ │ │ - muleq r3, lr, r1 │ │ │ │ - andeq r8, r3, r8, lsr #3 │ │ │ │ - @ instruction: 0x000381b2 │ │ │ │ - @ instruction: 0x000381bc │ │ │ │ - @ instruction: 0x000381b4 │ │ │ │ - andeq r8, r3, r2, asr #3 │ │ │ │ - andeq r8, r3, r6, asr #3 │ │ │ │ - ldrdeq r8, [r3], -r2 │ │ │ │ - muleq r3, r0, pc @ │ │ │ │ - andeq r7, r3, ip, ror pc │ │ │ │ - andeq r7, r3, ip, ror pc │ │ │ │ - andeq r7, r3, r8, ror #30 │ │ │ │ - andeq r7, r3, ip, ror #30 │ │ │ │ - andeq r8, r3, r0, ror #2 │ │ │ │ + andeq r8, r3, sl, asr #2 │ │ │ │ + andeq r7, r3, r8, lsl #30 │ │ │ │ + strdeq r7, [r3], -r4 │ │ │ │ + strdeq r7, [r3], -r4 │ │ │ │ + andeq r7, r3, r0, ror #29 │ │ │ │ + andeq r7, r3, r4, ror #29 │ │ │ │ + ldrdeq r8, [r3], -r8 @ │ │ │ │ cmpcs r8, #3522560 @ 0x35c000 │ │ │ │ ldrbtmi r4, [r9], #-2378 @ 0xfffff6b6 │ │ │ │ @ instruction: 0xf7e94608 │ │ │ │ - ldmib r7, {r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmib r7, {r3, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ stmdbmi r8, {r1, r5, r6, r8, r9, sp}^ │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - svc 0x0098f7e9 │ │ │ │ + svc 0x00b0f7e9 │ │ │ │ ldrbtmi r4, [fp], #-2886 @ 0xfffff4ba │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - ldmib r7, {r5, r6, fp, sp, lr, pc}^ │ │ │ │ + ldmib r7, {r4, r5, r6, fp, sp, lr, pc}^ │ │ │ │ stmdbmi r4, {r3, r4, r5, r8, r9, sp}^ │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - svc 0x008cf7e9 │ │ │ │ + svc 0x00a4f7e9 │ │ │ │ teqcs sl, #3522560 @ 0x35c000 │ │ │ │ ldrbtmi r4, [r9], #-2369 @ 0xfffff6bf │ │ │ │ @ instruction: 0xf7e94608 │ │ │ │ - ldmib r7, {r1, r2, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmib r7, {r1, r2, r3, r4, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ ldmdbmi pc!, {r2, r3, r4, r5, r8, r9, sp} @ │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - svc 0x007ef7e9 │ │ │ │ + svc 0x0096f7e9 │ │ │ │ teqcs lr, #3522560 @ 0x35c000 │ │ │ │ ldrbtmi r4, [r9], #-2364 @ 0xfffff6c4 │ │ │ │ @ instruction: 0xf7e94608 │ │ │ │ - ldmib r7, {r3, r4, r5, r6, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmib r7, {r4, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ ldmdbmi sl!, {r6, r8, r9, sp} │ │ │ │ @ instruction: 0x46084479 │ │ │ │ - svc 0x0070f7e9 │ │ │ │ - blvc d54a50 <__bss_end__@@Base+0xcade18> │ │ │ │ - blvc ff054ecc <__bss_end__@@Base+0xfefae294> │ │ │ │ - blx 454fc0 <__bss_end__@@Base+0x3ae388> │ │ │ │ + svc 0x0088f7e9 │ │ │ │ + blvc d549d8 <__bss_end__@@Base+0xcade38> │ │ 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r3, r0, lsl r1 │ │ │ │ - ldrdeq r8, [r3], -lr │ │ │ │ + andeq r8, r3, r2, ror r0 │ │ │ │ + andeq r7, r3, ip, lsr #29 │ │ │ │ + andeq r8, r3, lr, lsl #1 │ │ │ │ + muleq r3, r0, r0 │ │ │ │ + muleq r3, r2, r0 │ │ │ │ + muleq r3, r4, r0 │ │ │ │ + muleq r3, r6, r0 │ │ │ │ + muleq r3, r8, r0 │ │ │ │ + andeq r8, r3, sl, lsl #1 │ │ │ │ + andeq r8, r3, ip, lsl #1 │ │ │ │ + andeq r8, r3, r4, lsl #1 │ │ │ │ + andeq r8, r3, r8, lsl #1 │ │ │ │ + andeq r8, r3, r6, asr r0 │ │ │ │ addlt fp, lr, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r2, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ movwcs r6, #59 @ 0x3b │ │ │ │ teqcs ip, #-1342177265 @ 0xb000000f │ │ │ │ teqcs ip, #-1342177269 @ 0xb000000b │ │ │ │ @ instruction: 0xf64f627b │ │ │ │ @ instruction: 0xf6cf4318 │ │ │ │ @ instruction: 0x61bb73ff │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ @ instruction: 0xf04f617b │ │ │ │ teqvs fp, pc @ │ │ │ │ @ instruction: 0xf7e968f8 │ │ │ │ - strmi lr, [r3], -r2, lsl #29 │ │ │ │ + @ instruction: 0x4603ee9a │ │ │ │ movwcs r6, #507 @ 0x1fb │ │ │ │ sub r6, r0, fp, lsr r2 │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r9, fp, sp, lr}^ │ │ │ │ ldmdavc fp, {r0, r1, r4, sl, lr} │ │ │ │ stmdble r5, {r0, r1, r2, r3, r5, r8, r9, fp, sp} │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r9, fp, sp, lr}^ │ │ │ │ ldmdavc fp, {r0, r1, r4, sl, lr} │ │ │ │ @@ -22481,171 +22476,171 @@ │ │ │ │ andsle r2, r6, sp, lsr #22 │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r9, fp, sp, lr}^ │ │ │ │ ldmdavc fp, {r0, r1, r4, sl, lr} │ │ │ │ andsle r2, r0, r0, lsl #22 │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r9, fp, sp, lr}^ │ │ │ │ ldmdavc fp, {r0, r1, r4, sl, lr} │ │ │ │ andle r2, sl, sl, lsl #22 │ │ │ │ - blmi 1373668 <__bss_end__@@Base+0x12cca30> │ │ │ │ + blmi 13735f0 <__bss_end__@@Base+0x12cca50> │ │ │ │ @ instruction: 0x4610447b │ │ │ │ orrcs r4, r9, #26214400 @ 0x1900000 │ │ │ │ @ instruction: 0xf7e9461a │ │ │ │ - movwcs lr, #3664 @ 0xe50 │ │ │ │ - bvs f117c4 <__bss_end__@@Base+0xe6ab8c> │ │ │ │ + movwcs lr, #3688 @ 0xe68 │ │ │ │ + bvs f1174c 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r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0xf7e94618 │ │ │ │ - ldmdavs fp!, {r1, r2, r3, r4, fp, sp, lr, pc}^ │ │ │ │ + ldmdavs fp!, {r2, r4, r5, fp, sp, lr, pc}^ │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ andle r2, r7, r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7e94618 │ │ │ │ - ldmdavs fp!, {r1, r4, fp, sp, lr, pc}^ │ │ │ │ + ldmdavs fp!, {r3, r5, fp, sp, lr, pc}^ │ │ │ │ subsvs r2, sl, r0, lsl #4 │ │ │ │ - blcs 34328 │ │ │ │ + blcs 342b0 │ │ │ │ ldmdavs r8!, {r2, ip, lr, pc}^ │ │ │ │ - stmda r8, {r0, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda lr, {r0, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ rsbsvs r2, fp, r0, lsl #6 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ svcge 0x0000b082 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ - blcs 34dcc │ │ │ │ + blcs 34d54 │ │ │ │ ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ @ instruction: 0x46186b1b │ │ │ │ - svc 0x00f4f7e8 │ │ │ │ + stmda sl, {r0, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r8, r9, sp, lr}^ │ │ │ │ - blcs 34ee4 │ │ │ │ + blcs 34e6c │ │ │ │ ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ @ instruction: 0x46186b5b │ │ │ │ - svc 0x00e8f7e8 │ │ │ │ + svc 0x00fef7e8 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r8, r9, sp, lr}^ │ │ │ │ - blcs 34ffc │ │ │ │ + blcs 34f84 │ │ │ │ ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ @ instruction: 0x46186b9b │ │ │ │ - svc 0x00dcf7e8 │ │ │ │ + svc 0x00f2f7e8 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, r8, r9, sp, lr}^ │ │ │ │ - blcs 35114 │ │ │ │ + blcs 3509c │ │ │ │ ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ @ instruction: 0x46186bdb │ │ │ │ - svc 0x00d0f7e8 │ │ │ │ + svc 0x00e6f7e8 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, r7, r8, r9, sp, lr}^ │ │ │ │ andle r2, r4, r0, lsl #22 │ │ │ │ @ instruction: 0xf7e86878 │ │ │ │ - movwcs lr, #4040 @ 0xfc8 │ │ │ │ + movwcs lr, #4062 @ 0xfde │ │ │ │ movwcs r6, #4219 @ 0x107b │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ andle r2, r7, r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0xf7e84618 │ │ │ │ - ldmdavs fp!, {r2, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmdavs fp!, {r1, r3, r6, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ andsvs r2, sl, r0, lsl #4 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ andle r2, r7, r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7e84618 │ │ │ │ - ldmdavs fp!, {r3, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmdavs fp!, {r1, r2, r3, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ subsvs r2, sl, r0, lsl #4 │ │ │ │ - blcs 343fc │ │ │ │ + blcs 34384 │ │ │ │ ldmdavs r8!, {r2, ip, lr, pc}^ │ │ │ │ - svc 0x009ef7e8 │ │ │ │ + svc 0x00b4f7e8 │ │ │ │ rsbsvs r2, fp, r0, lsl #6 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ svcge 0x0000b082 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ - blcs 342a0 │ │ │ │ + blcs 34228 │ │ │ │ ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - svc 0x008af7e8 │ │ │ │ + svc 0x00a0f7e8 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ - blcs 343b8 │ │ │ │ + blcs 34340 │ │ │ │ ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ @ instruction: 0x4618685b │ │ │ │ - svc 0x007ef7e8 │ │ │ │ + svc 0x0094f7e8 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ - blcs 344d0 │ │ │ │ + blcs 34458 │ │ │ │ ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ @ instruction: 0x4618689b │ │ │ │ - svc 0x0072f7e8 │ │ │ │ + svc 0x0088f7e8 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ andle r2, r4, r0, lsl #22 │ │ │ │ @ instruction: 0xf7e86878 │ │ │ │ - movwcs lr, #3946 @ 0xf6a │ │ │ │ + movwcs lr, #3968 @ 0xf80 │ │ │ │ movwcs r6, #4219 @ 0x107b │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ svcge 0x0008b099 │ │ │ │ eorsvs r6, r9, r8, ror r0 │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, fp, sp, lr}^ │ │ │ │ stmib r7, {r8, r9, sp}^ │ │ │ │ @ instruction: 0xf107230a │ │ │ │ @ instruction: 0x46180318 │ │ │ │ stc2l 0, cr15, [r8, #-12] │ │ │ │ - bvs e74a9c <__bss_end__@@Base+0xdcde64> │ │ │ │ + bvs e74a24 <__bss_end__@@Base+0xdcde84> │ │ │ │ @ instruction: 0xf10769bb │ │ │ │ movwls r0, #12 │ │ │ │ stmdbmi ip, {r0, r1, r3, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7e94479 │ │ │ │ - blmi 1314940 <__bss_end__@@Base+0x126dd08> │ │ │ │ + blmi 13148f0 <__bss_end__@@Base+0x126dd50> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7e86878 │ │ │ │ - @ instruction: 0x4603efb6 │ │ │ │ + strmi lr, [r3], -lr, asr #31 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r8, r9, sp, lr} │ │ │ │ movwcs lr, #10707 @ 0x29d3 │ │ │ │ tstcc r0, r9, lsr r8 │ │ │ │ andeq pc, ip, r7, lsl #2 │ │ │ │ tstls r0, r1 │ │ │ │ ldrbtmi r4, [r9], #-2371 @ 0xfffff6bd │ │ │ │ @ instruction: 0xf7e96b78 │ │ │ │ - movwcs lr, #6228 @ 0x1854 │ │ │ │ + movwcs lr, #6252 @ 0x186c │ │ │ │ strd r6, [sp], #-59 @ 0xffffffc5 @ │ │ │ │ @ instruction: 0x63bb2300 │ │ │ │ - blvs fff1248c <__bss_end__@@Base+0xffe6b854> │ │ │ │ - blvs ffea6f08 <__bss_end__@@Base+0xffe002d0> │ │ │ │ + blvs fff12414 <__bss_end__@@Base+0xffe6b874> │ │ │ │ + blvs ffea6e90 <__bss_end__@@Base+0xffe002f0> │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldrmi r0, [r3], #-4058 @ 0xfffff026 │ │ │ │ @ instruction: 0x461a105b │ │ │ │ ldrmi r6, [r3], #-3003 @ 0xfffff445 │ │ │ │ - blvs feef3004 <__bss_end__@@Base+0xfee4c3cc> │ │ │ │ + blvs feef2f8c <__bss_end__@@Base+0xfee4c3ec> │ │ │ │ eorle r2, ip, r0, lsl #22 │ │ │ │ - blvs 6b440c <__bss_end__@@Base+0x60d7d4> │ │ │ │ + blvs 6b4394 <__bss_end__@@Base+0x60d7f4> │ │ │ │ sbcseq r6, fp, fp, lsr fp │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ ldmdavs r9!, {r8, r9, fp, ip, sp, lr} │ │ │ │ - blvs e75050 <__bss_end__@@Base+0xdce418> │ │ │ │ + blvs e74fd8 <__bss_end__@@Base+0xdce438> │ │ │ │ strmi r0, [r1], #-201 @ 0xffffff37 │ │ │ │ ldrdeq lr, [r0, -r1] │ │ │ │ - blvs fe97442c <__bss_end__@@Base+0xfe8cd7f4> │ │ │ │ + blvs fe9743b4 <__bss_end__@@Base+0xfe8cd814> │ │ │ │ rsceq r6, r4, ip, lsr fp │ │ │ │ ldmib r4, {r2, r3, r5, sl, lr}^ │ │ │ │ ldmdavs lr!, {r8, sl, lr} │ │ │ │ @ instruction: 0x46336bf6 │ │ │ │ rscseq r6, r6, lr, lsr fp │ │ │ │ ldmib r6, {r1, r2, r3, r4, sl, lr}^ │ │ │ │ stmib sp, {r8, fp, pc}^ │ │ │ │ stmib sp, {r1, r2, r8, fp, pc}^ │ │ │ │ stmib sp, {r2, r8, sl, lr}^ │ │ │ │ stc 1, cr0, [sp, #8] │ │ │ │ - blvs feef8f68 <__bss_end__@@Base+0xfee52330> │ │ │ │ + blvs feef8ef0 <__bss_end__@@Base+0xfee52350> │ │ │ │ stmdbmi r4!, {r1, r3, r4, r5, r6, r7, r8, r9, fp, sp, lr} │ │ │ │ - blvs 1e2b554 <__bss_end__@@Base+0x1d8491c> │ │ │ │ - ldmda r2, {r0, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blvs 1e2b4dc <__bss_end__@@Base+0x1d8493c> │ │ │ │ + stmda sl!, {r0, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldmdavs fp!, {r2, r5, sp, lr, pc} │ │ │ │ - blvs ef4fe4 <__bss_end__@@Base+0xe4e3ac> │ │ │ │ + blvs ef4f6c <__bss_end__@@Base+0xe4e3cc> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ - blvs fe23446c <__bss_end__@@Base+0xfe18d834> │ │ │ │ + blvs fe2343f4 <__bss_end__@@Base+0xfe18d854> │ │ │ │ sbceq r6, r9, r9, lsr fp │ │ │ │ ldmib r1, {r0, sl, lr}^ │ │ │ │ @ instruction: 0xf04f0100 │ │ │ │ @ instruction: 0xf04f0400 │ │ │ │ stmib sp, {r8, sl}^ │ │ │ │ stmib sp, {r1, r2, r8, sl, lr}^ │ │ │ │ @ instruction: 0xf04f0104 │ │ │ │ @ instruction: 0xf04f0000 │ │ │ │ stmib sp, {r8}^ │ │ │ │ stmib sp, {r1, r8}^ │ │ │ │ - blvs feee2fb4 <__bss_end__@@Base+0xfee3c37c> │ │ │ │ + blvs feee2f3c <__bss_end__@@Base+0xfee3c39c> │ │ │ │ ldmdbmi r2, {r1, r3, r4, r5, r6, r7, r8, r9, fp, sp, lr} │ │ │ │ - blvs 1e2b5a0 <__bss_end__@@Base+0x1d84968> │ │ │ │ - svc 0x00ecf7e8 │ │ │ │ + blvs 1e2b528 <__bss_end__@@Base+0x1d84988> │ │ │ │ + stmda r4, {r0, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ movwcc r6, #7099 @ 0x1bbb │ │ │ │ - blvs feeb32b4 <__bss_end__@@Base+0xfee0c67c> │ │ │ │ + blvs feeb323c <__bss_end__@@Base+0xfee0c69c> │ │ │ │ addsmi r6, sl, #257024 @ 0x3ec00 │ │ │ │ - blvs fff11a2c <__bss_end__@@Base+0xffe6adf4> │ │ │ │ + blvs fff119b4 <__bss_end__@@Base+0xffe6ae14> │ │ │ │ mvnsvs r3, #67108864 @ 0x4000000 │ │ │ │ ldcvs 8, cr6, [fp], {59} @ 0x3b │ │ │ │ addsmi r6, sl, #256000 @ 0x3e800 │ │ │ │ - blvs 1e51a10 <__bss_end__@@Base+0x1daadd8> │ │ │ │ - ldcl 7, cr15, [ip, #928]! @ 0x3a0 │ │ │ │ + blvs 1e51998 <__bss_end__@@Base+0x1daadf8> │ │ │ │ + cdp 7, 1, cr15, cr0, cr8, {7} │ │ │ │ strbcc fp, [r4, -r0, lsl #30] │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ svclt 0x000083f0 │ │ │ │ - andeq r6, r3, r8, asr #24 │ │ │ │ - ldrdeq r7, [r3], -r4 │ │ │ │ - @ instruction: 0x00037ab6 │ │ │ │ - andeq r7, r3, r0, ror #20 │ │ │ │ - andeq r7, r3, r4, lsl sl │ │ │ │ + andeq r6, r3, r0, asr #23 │ │ │ │ + andeq r7, r3, ip, asr #20 │ │ │ │ + andeq r7, r3, lr, lsr #20 │ │ │ │ + ldrdeq r7, [r3], -r8 │ │ │ │ + andeq r7, r3, ip, lsl #19 │ │ │ │ addslt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r4, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ stmib r7, {r8, r9, sp}^ │ │ │ │ @ instruction: 0xf107230c │ │ │ │ ldrmi r0, [r8], -r0, lsr #6 │ │ │ │ stc2 0, cr15, [lr], {3} │ │ │ │ - bvs fee74e10 <__bss_end__@@Base+0xfedce1d8> │ │ │ │ + bvs fee74d98 <__bss_end__@@Base+0xfedce1f8> │ │ │ │ @ instruction: 0xf1076a3b │ │ │ │ movwls r0, #20 │ │ │ │ stmdbmi sl!, {r0, r1, r3, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7e94479 │ │ │ │ - blmi 1a947cc <__bss_end__@@Base+0x19edb94> │ │ │ │ + blmi 1a9477c <__bss_end__@@Base+0x19edbdc> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7e868f8 │ │ │ │ - @ instruction: 0x4603eefc │ │ │ │ + @ instruction: 0x4603ef14 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sp, lr}^ │ │ │ │ movwcs lr, #10707 @ 0x29d3 │ │ │ │ tstcc r0, r9, ror r8 │ │ │ │ andseq pc, r4, r7, lsl #2 │ │ │ │ tstls r0, r1 │ │ │ │ ldrbtmi r4, [r9], #-2401 @ 0xfffff69f │ │ │ │ @ instruction: 0xf7e86bf8 │ │ │ │ - movwcs lr, #8090 @ 0x1f9a │ │ │ │ + movwcs lr, #8114 @ 0x1fb2 │ │ │ │ sub r6, fp, fp, ror r4 │ │ │ │ ldrtvs r2, [fp], #-768 @ 0xfffffd00 │ │ │ │ ldclvs 0, cr14, [fp], #-260 @ 0xfffffefc │ │ │ │ ldclvs 3, cr3, [sl], #-4 │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldrmi r0, [r3], #-4058 @ 0xfffff026 │ │ │ │ @ instruction: 0x461a105b │ │ │ │ ldrmi r6, [r3], #-3131 @ 0xfffff3c5 │ │ │ │ ldcvs 3, cr6, [fp], #-748 @ 0xfffffd14 │ │ │ │ andsle r2, r9, r0, lsl #22 │ │ │ │ - blvs 6b4680 <__bss_end__@@Base+0x60da48> │ │ │ │ + blvs 6b4608 <__bss_end__@@Base+0x60da68> │ │ │ │ ldrheq r6, [fp], #187 @ 0xbb │ │ │ │ ldmib r3, {r0, r1, r4, sl, lr}^ │ │ │ │ ldmdavs r9!, {r8, r9, sp}^ │ │ │ │ - blvs fee751c4 <__bss_end__@@Base+0xfedce58c> │ │ │ │ + blvs fee7514c <__bss_end__@@Base+0xfedce5ac> │ │ │ │ strmi r0, [r1], #-201 @ 0xffffff37 │ │ │ │ ldrdeq lr, [r0, -r1] │ │ │ │ smlabteq r2, sp, r9, lr │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ ldclvs 12, cr6, [sl], #-236 @ 0xffffff14 │ │ │ │ ldrbtmi r4, [r9], #-2379 @ 0xfffff6b5 │ │ │ │ @ instruction: 0xf7e86bf8 │ │ │ │ - ands lr, r5, ip, ror #30 │ │ │ │ - blvs 6b46b4 <__bss_end__@@Base+0x60da7c> │ │ │ │ + ands lr, r5, r4, lsl #31 │ │ │ │ + blvs 6b463c <__bss_end__@@Base+0x60da9c> │ │ │ │ ldrheq r6, [fp], #187 @ 0xbb │ │ │ │ ldmib r3, {r0, r1, r4, sl, lr}^ │ │ │ │ @ instruction: 0xf04f2300 │ │ │ │ @ instruction: 0xf04f0000 │ │ │ │ stmib sp, {r8}^ │ │ │ │ stmib sp, {r1, r8}^ │ │ │ │ ldcvs 3, cr2, [fp], #-0 │ │ │ │ stmdbmi r1, {r1, r3, r4, r5, r6, sl, fp, sp, lr}^ │ │ │ │ - blvs ffe2b6d0 <__bss_end__@@Base+0xffd84a98> │ │ │ │ - svc 0x0054f7e8 │ │ │ │ + blvs ffe2b658 <__bss_end__@@Base+0xffd84ab8> │ │ │ │ + svc 0x006cf7e8 │ │ │ │ movwcc r6, #7227 @ 0x1c3b │ │ │ │ ldcvs 4, cr6, [sl], #-236 @ 0xffffff14 │ │ │ │ addsmi r6, sl, #31488 @ 0x7b00 │ │ │ │ ldclvs 13, cr13, [fp], #-740 @ 0xfffffd1c │ │ │ │ ldrbtvs r3, [fp], #-769 @ 0xfffffcff │ │ │ │ ldcvs 8, cr6, [fp], {123} @ 0x7b │ │ │ │ addsmi r6, sl, #31232 @ 0x7a00 │ │ │ │ - blvs ffe51bc8 <__bss_end__@@Base+0xffdaaf90> │ │ │ │ - stcl 7, cr15, [r4, #-928]! @ 0xfffffc60 │ │ │ │ + blvs ffe51b50 <__bss_end__@@Base+0xffdaafb0> │ │ │ │ + ldcl 7, cr15, [r8, #-928]! @ 0xfffffc60 │ │ │ │ ldrbtmi r4, [fp], #-2870 @ 0xfffff4ca │ │ │ │ ldmvs r8!, {r0, r3, r4, r9, sl, lr} │ │ │ │ - cdp 7, 8, cr15, cr14, cr8, {7} │ │ │ │ + cdp 7, 10, cr15, cr6, cr8, {7} │ │ │ │ mvnsvs r4, #3145728 @ 0x300000 │ │ │ │ ldrbtvs r2, [fp], #-769 @ 0xfffffcff │ │ │ │ movwcs lr, #75 @ 0x4b │ │ │ │ sub r6, r1, fp, lsr r4 │ │ │ │ movwcc r6, #7291 @ 0x1c7b │ │ │ │ - blx b5722 <__bss_end__@@Base+0xeaea> │ │ │ │ + blx b56aa <__bss_end__@@Base+0xeb0a> │ │ │ │ svceq 0x00daf303 │ │ │ │ subsne r4, fp, r3, lsl r4 │ │ │ │ ldcvs 6, cr4, [fp], #-104 @ 0xffffff98 │ │ │ │ @ instruction: 0x63bb4413 │ │ │ │ - blcs 35638 │ │ │ │ + blcs 355c0 │ │ │ │ ldmdavs fp!, {r0, r3, r4, ip, lr, pc}^ │ │ │ │ - blvs feef53bc <__bss_end__@@Base+0xfee4e784> │ │ │ │ + blvs feef5344 <__bss_end__@@Base+0xfee4e7a4> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ - blvs ff234744 <__bss_end__@@Base+0xff18db0c> │ │ │ │ + blvs ff2346cc <__bss_end__@@Base+0xff18db2c> │ │ │ │ strheq r6, [r9], #185 @ 0xb9 │ │ │ │ ldmib r1, {r0, sl, lr}^ │ │ │ │ stmib sp, {r8}^ │ │ │ │ stmib sp, {r1, r8}^ │ │ │ │ ldcvs 3, cr2, [fp], #-0 │ │ │ │ ldmdbmi pc, {r1, r3, r4, r5, r6, sl, fp, sp, lr} @ │ │ │ │ - blvs ffe2b760 <__bss_end__@@Base+0xffd84b28> │ │ │ │ - svc 0x000cf7e8 │ │ │ │ + blvs ffe2b6e8 <__bss_end__@@Base+0xffd84b48> │ │ │ │ + svc 0x0024f7e8 │ │ │ │ ldmdavs fp!, {r0, r2, r4, sp, lr, pc}^ │ │ │ │ - blvs feef53f0 <__bss_end__@@Base+0xfee4e7b8> │ │ │ │ + blvs feef5378 <__bss_end__@@Base+0xfee4e7d8> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ andeq pc, r0, pc, asr #32 │ │ │ │ tstpeq r0, pc, asr #32 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, sp, r9, lr │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ ldclvs 12, cr6, [sl], #-236 @ 0xffffff14 │ │ │ │ ldrbtmi r4, [r9], #-2324 @ 0xfffff6ec │ │ │ │ @ instruction: 0xf7e86bf8 │ │ │ │ - ldcvs 14, cr14, [fp], #-984 @ 0xfffffc28 │ │ │ │ + ldcvs 15, cr14, [fp], #-56 @ 0xffffffc8 │ │ │ │ ldrtvs r3, [fp], #-769 @ 0xfffffcff │ │ │ │ ldclvs 12, cr6, [fp], #-232 @ 0xffffff18 │ │ │ │ ldcle 2, cr4, [r9, #616]! @ 0x268 │ │ │ │ movwcc r6, #7291 @ 0x1c7b │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, sl, sp, lr}^ │ │ │ │ ldclvs 12, cr6, [sl], #-364 @ 0xfffffe94 │ │ │ │ stcle 2, cr4, [lr, #616]! @ 0x268 │ │ │ │ @ instruction: 0xf7e86bf8 │ │ │ │ - svclt 0x0000ed06 │ │ │ │ + svclt 0x0000ed1a │ │ │ │ ldrtmi r3, [sp], r8, asr #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - ldrdeq r6, [r3], -r4 │ │ │ │ - andeq r7, r3, r0, ror #18 │ │ │ │ - andeq r7, r3, r2, asr #18 │ │ │ │ - andeq r7, r3, r6, lsr r9 │ │ │ │ - andeq r7, r3, r8, lsl #18 │ │ │ │ - andeq r7, r3, r6, lsl #17 │ │ │ │ - andeq r7, r3, r8, ror r8 │ │ │ │ - andeq r7, r3, sl, asr #16 │ │ │ │ + andeq r6, r3, ip, asr #20 │ │ │ │ + ldrdeq r7, [r3], -r8 │ │ │ │ + @ instruction: 0x000378ba │ │ │ │ + andeq r7, r3, lr, lsr #17 │ │ │ │ + andeq r7, r3, r0, lsl #17 │ │ │ │ + strdeq r7, [r3], -lr │ │ │ │ + strdeq r7, [r3], -r0 │ │ │ │ + andeq r7, r3, r2, asr #15 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ svcge 0x0008b093 │ │ │ │ ldrshtvs r6, [r9], r8 │ │ │ │ - blmi ff8727f4 <__bss_end__@@Base+0xff7cbbbc> │ │ │ │ + blmi ff87277c <__bss_end__@@Base+0xff7cbbdc> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7e868f8 │ │ │ │ - @ instruction: 0x4603ee14 │ │ │ │ + strmi lr, [r3], -ip, lsr #28 │ │ │ │ movwcs r6, #379 @ 0x17b │ │ │ │ @ instruction: 0xe1ab627b │ │ │ │ - blcc 74810 <__bss_start@@Base+0x19770> │ │ │ │ + blcc 74798 <__bss_start@@Base+0x19790> │ │ │ │ addsmi r6, sl, #499712 @ 0x7a000 │ │ │ │ - bvs 1f10e7c <__bss_end__@@Base+0x1e6a244> │ │ │ │ + bvs 1f10e04 <__bss_end__@@Base+0x1e6a264> │ │ │ │ ldmvs fp!, {r1, r3, r4, r6, sl, fp, ip} │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ - blvs d5c84 <__bss_end__@@Base+0x2f04c> │ │ │ │ - bvs 1eb4928 <__bss_end__@@Base+0x1e0dcf0> │ │ │ │ + blvs d5c0c <__bss_end__@@Base+0x2f06c> │ │ │ │ + bvs 1eb48b0 <__bss_end__@@Base+0x1e0dd10> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ - blvc d5c90 <__bss_end__@@Base+0x2f058> │ │ │ │ - blvc 1215f20 <__bss_end__@@Base+0x116f2e8> │ │ │ │ - blvc ff216240 <__bss_end__@@Base+0xff16f608> │ │ │ │ - bcc fe455eac <__bss_end__@@Base+0xfe3af274> │ │ │ │ + blvc d5c18 <__bss_end__@@Base+0x2f078> │ │ │ │ + blvc 1215ea8 <__bss_end__@@Base+0x116f308> │ │ │ │ + blvc ff2161c8 <__bss_end__@@Base+0xff16f628> │ │ │ │ + bcc fe455e34 <__bss_end__@@Base+0xfe3af294> │ │ │ │ @ instruction: 0xe01361bb │ │ │ │ - bvs 1eb4944 <__bss_end__@@Base+0x1e0dd0c> │ │ │ │ + bvs 1eb48cc <__bss_end__@@Base+0x1e0dd2c> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ - blvs d5cac <__bss_end__@@Base+0x2f074> │ │ │ │ + blvs d5c34 <__bss_end__@@Base+0x2f094> │ │ │ │ @ instruction: 0x1e5a6a7b │ │ │ │ @ instruction: 0xf85368bb │ │ │ │ ldc 0, cr3, [r3, #136] @ 0x88 │ │ │ │ vadd.f64 d7, d6, d2 │ │ │ │ vcvtr.s32.f64 s15, d7 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ @ instruction: 0x61bb3a90 │ │ │ │ ldrbtmi r4, [fp], #-3013 @ 0xfffff43b │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 8, cr15, cr8, cr8, {7} │ │ │ │ - bvs 1eb4978 <__bss_end__@@Base+0x1e0dd40> │ │ │ │ + cdp 7, 10, cr15, cr0, cr8, {7} │ │ │ │ + bvs 1eb4900 <__bss_end__@@Base+0x1e0dd60> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ @ instruction: 0x461a3310 │ │ │ │ ldrbtmi r4, [fp], #-3008 @ 0xfffff440 │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 7, cr15, cr12, cr8, {7} │ │ │ │ + cdp 7, 9, cr15, cr4, cr8, {7} │ │ │ │ ldrbtmi r4, [fp], #-3006 @ 0xfffff442 │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 7, cr15, cr6, cr8, {7} │ │ │ │ + cdp 7, 8, cr15, cr14, cr8, {7} │ │ │ │ ldrbtmi r4, [fp], #-3004 @ 0xfffff444 │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 7, cr15, cr0, cr8, {7} │ │ │ │ + cdp 7, 8, cr15, cr8, cr8, {7} │ │ │ │ ldrbtmi r4, [fp], #-3002 @ 0xfffff446 │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 6, cr15, cr10, cr8, {7} │ │ │ │ - bvs 1eb49b4 <__bss_end__@@Base+0x1e0dd7c> │ │ │ │ + cdp 7, 8, cr15, cr2, cr8, {7} │ │ │ │ + bvs 1eb493c <__bss_end__@@Base+0x1e0dd9c> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ - blvc d5d1c <__bss_end__@@Base+0x2f0e4> │ │ │ │ - blvc ff2162c8 <__bss_end__@@Base+0xff16f690> │ │ │ │ - bcs fe455f34 <__bss_end__@@Base+0xfe3af2fc> │ │ │ │ + blvc d5ca4 <__bss_end__@@Base+0x2f104> │ │ │ │ + blvc ff216250 <__bss_end__@@Base+0xff16f6b0> │ │ │ │ + bcs fe455ebc <__bss_end__@@Base+0xfe3af31c> │ │ │ │ ldrbtmi r4, [fp], #-2995 @ 0xfffff44d │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 5, cr15, cr10, cr8, {7} │ │ │ │ - bvs 1eb49d4 <__bss_end__@@Base+0x1e0dd9c> │ │ │ │ + cdp 7, 7, cr15, cr2, cr8, {7} │ │ │ │ + bvs 1eb495c <__bss_end__@@Base+0x1e0ddbc> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ - blvc d5d3c <__bss_end__@@Base+0x2f104> │ │ │ │ - blvc ff2162e8 <__bss_end__@@Base+0xff16f6b0> │ │ │ │ - bcs fe455f54 <__bss_end__@@Base+0xfe3af31c> │ │ │ │ + blvc d5cc4 <__bss_end__@@Base+0x2f124> │ │ │ │ + blvc ff216270 <__bss_end__@@Base+0xff16f6d0> │ │ │ │ + bcs fe455edc <__bss_end__@@Base+0xfe3af33c> │ │ │ │ ldrmi r6, [r3], #-2491 @ 0xfffff645 │ │ │ │ - blmi feaebf68 <__bss_end__@@Base+0xfea45330> │ │ │ │ + blmi feaebef0 <__bss_end__@@Base+0xfea45350> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7e86978 │ │ │ │ - ldmvs fp!, {r3, r6, r9, sl, fp, sp, lr, pc} │ │ │ │ + ldmvs fp!, {r5, r6, r9, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf8536a7a │ │ │ │ ldmib r3, {r1, r5, ip, sp}^ │ │ │ │ stmibmi r6!, {r1, r8, r9, sp} │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - cdp 7, 3, cr15, cr12, cr8, {7} │ │ │ │ - bvs 1eb4a10 <__bss_end__@@Base+0x1e0ddd8> │ │ │ │ + cdp 7, 5, cr15, cr4, cr8, {7} │ │ │ │ + bvs 1eb4998 <__bss_end__@@Base+0x1e0ddf8> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ @ instruction: 0x461a6c1b │ │ │ │ ldrbtmi r4, [fp], #-2977 @ 0xfffff45f │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 3, cr15, cr0, cr8, {7} │ │ │ │ - bvs 1eb4a28 <__bss_end__@@Base+0x1e0ddf0> │ │ │ │ + cdp 7, 4, cr15, cr8, cr8, {7} │ │ │ │ + bvs 1eb49b0 <__bss_end__@@Base+0x1e0de10> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ @ instruction: 0x461a6c5b │ │ │ │ ldrbtmi r4, [fp], #-2972 @ 0xfffff464 │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 2, cr15, cr4, cr8, {7} │ │ │ │ + cdp 7, 3, cr15, cr12, cr8, {7} │ │ │ │ ldrbtmi r4, [fp], #-2970 @ 0xfffff466 │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 1, cr15, cr14, cr8, {7} │ │ │ │ + cdp 7, 3, cr15, cr6, cr8, {7} │ │ │ │ ldrbtmi r4, [fp], #-2968 @ 0xfffff468 │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 1, cr15, cr8, cr8, {7} │ │ │ │ + cdp 7, 3, cr15, cr0, cr8, {7} │ │ │ │ ldrbtmi r4, [fp], #-2966 @ 0xfffff46a │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 1, cr15, cr2, cr8, {7} │ │ │ │ + cdp 7, 2, cr15, cr10, cr8, {7} │ │ │ │ ldrbtmi r4, [fp], #-2964 @ 0xfffff46c │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - cdp 7, 0, cr15, cr12, cr8, {7} │ │ │ │ + cdp 7, 2, cr15, cr4, cr8, {7} │ │ │ │ eorcs r6, ip, #2015232 @ 0x1ec000 │ │ │ │ ldmmi r1, {r0, r8, sp} │ │ │ │ @ instruction: 0xf7e84478 │ │ │ │ - ldmdbvs fp!, {r5, r6, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmdbvs fp!, {r3, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ tstcs r1, ip, lsr r2 │ │ │ │ ldrbtmi r4, [r8], #-2190 @ 0xfffff772 │ │ │ │ - ldcl 7, cr15, [r8, #928] @ 0x3a0 │ │ │ │ + ldcl 7, cr15, [r0, #928]! @ 0x3a0 │ │ │ │ eorscs r6, r0, #2015232 @ 0x1ec000 │ │ │ │ stmmi ip, {r0, r8, sp} │ │ │ │ @ instruction: 0xf7e84478 │ │ │ │ - movwcs lr, #7634 @ 0x1dd2 │ │ │ │ + movwcs lr, #7658 @ 0x1dea │ │ │ │ movwcs r6, #571 @ 0x23b │ │ │ │ movwcs r6, #4603 @ 0x11fb │ │ │ │ sbcs r6, r3, fp, lsr r2 │ │ │ │ mvnsvs r2, r0, lsl #6 │ │ │ │ - bvs f12ae0 <__bss_end__@@Base+0xe6bea8> │ │ │ │ - bvs ea73c8 <__bss_end__@@Base+0xe00790> │ │ │ │ + bvs f12a68 <__bss_end__@@Base+0xe6bec8> │ │ │ │ + bvs ea7350 <__bss_end__@@Base+0xe007b0> │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldrmi r0, [r3], #-4058 @ 0xfffff026 │ │ │ │ @ instruction: 0x461a105b │ │ │ │ ldrmi r6, [r3], #-2555 @ 0xfffff605 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r8, sp, lr}^ │ │ │ │ - bvs 1ea93e0 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sl, lr} │ │ │ │ @ instruction: 0xf8566a7b │ │ │ │ - blvs ffcf28b8 <__bss_end__@@Base+0xffc4bc80> │ │ │ │ + blvs ffcf2840 <__bss_end__@@Base+0xffc4bca0> │ │ │ │ rscseq r6, r6, lr, lsr r9 │ │ │ │ ldmib r6, {r1, r2, r3, r4, sl, lr}^ │ │ │ │ stmib sp, {r8, fp, pc}^ │ │ │ │ stmib sp, {r1, r2, r8, fp, pc}^ │ │ │ │ stmib sp, {r2, r8, sl, lr}^ │ │ │ │ stc 1, cr0, [sp, #8] │ │ │ │ ldmibvs fp!, {r8, r9, fp, ip, sp, lr}^ │ │ │ │ stmdbmi r3!, {r1, r3, r4, r5, r9, fp, sp, lr}^ │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - stc 7, cr15, [r2, #928]! @ 0x3a0 │ │ │ │ + ldc 7, cr15, [sl, #928]! @ 0x3a0 │ │ │ │ ldmvs fp!, {r0, r3, r4, r5, r6, sp, lr, pc} │ │ │ │ @ instruction: 0xf8536a7a │ │ │ │ - blvs 6a68e8 <__bss_end__@@Base+0x5ffcb0> │ │ │ │ + blvs 6a6870 <__bss_end__@@Base+0x5ffcd0> │ │ │ │ sbcseq r6, fp, fp, lsr r9 │ │ │ │ ldmib r3, {r0, r1, r4, sl, lr}^ │ │ │ │ ldmvs r9!, {r8, r9, sp} │ │ │ │ @ instruction: 0xf8516a78 │ │ │ │ - blvs fe21e8f4 <__bss_end__@@Base+0xfe177cbc> │ │ │ │ + blvs fe21e87c <__bss_end__@@Base+0xfe177cdc> │ │ │ │ sbceq r6, r9, r9, lsr r9 │ │ │ │ ldmib r1, {r0, sl, lr}^ │ │ │ │ stmib sp, {r8}^ │ │ │ │ stmib sp, {r1, r8}^ │ │ │ │ ldmibvs fp!, {r8, r9, sp}^ │ │ │ │ ldmdbmi r4, {r1, r3, r4, r5, r9, fp, sp, lr}^ │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - stc 7, cr15, [r2, #928] @ 0x3a0 │ │ │ │ + ldc 7, cr15, [sl, #928] @ 0x3a0 │ │ │ │ ldmibvs fp!, {r0, r3, r4, r6, sp, lr, pc}^ │ │ │ │ eorsle r2, r7, r0, lsl #22 │ │ │ │ - bvs 1eb4b8c <__bss_end__@@Base+0x1e0df54> │ │ │ │ + bvs 1eb4b14 <__bss_end__@@Base+0x1e0df74> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r8, r9, fp, sp, lr} │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blvc 55efc │ │ │ │ - bvs 1e34b98 <__bss_end__@@Base+0x1d8df60> │ │ │ │ + blvc 55e84 │ │ │ │ + bvs 1e34b20 <__bss_end__@@Base+0x1d8df80> │ │ │ │ eorne pc, r0, r1, asr r8 @ │ │ │ │ ldmdbvs r9!, {r3, r6, r8, r9, fp, sp, lr} │ │ │ │ strmi r0, [r1], #-201 @ 0xffffff37 │ │ │ │ ldrdeq lr, [r0, -r1] │ │ │ │ - bvs 1f74bb8 <__bss_end__@@Base+0x1ecdf80> │ │ │ │ + bvs 1f74b40 <__bss_end__@@Base+0x1ecdfa0> │ │ │ │ eormi pc, r5, r4, asr r8 @ │ │ │ │ ldmdbvs ip!, {r0, r2, r5, r7, r8, r9, fp, sp, lr} │ │ │ │ strtmi r0, [ip], #-228 @ 0xffffff1c │ │ │ │ strmi lr, [r0, #-2516] @ 0xfffff62c │ │ │ │ - bvs 1ef4bd4 <__bss_end__@@Base+0x1e4df9c> │ │ │ │ + bvs 1ef4b5c <__bss_end__@@Base+0x1e4dfbc> │ │ │ │ eorvs pc, r3, r6, asr r8 @ │ │ │ │ ldmdbvs lr!, {r0, r1, r4, r5, r6, r7, r8, r9, fp, sp, lr} │ │ │ │ ldrmi r0, [lr], #-246 @ 0xffffff0a │ │ │ │ stmdbhi r0, {r1, r2, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ stmdbhi r6, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ strmi lr, [r4, #-2509] @ 0xfffff633 │ │ │ │ smlabteq r2, sp, r9, lr │ │ │ │ - blvc 55f30 │ │ │ │ - bvs eb50ec <__bss_end__@@Base+0xe0e4b4> │ │ │ │ + blvc 55eb8 │ │ │ │ + bvs eb5074 <__bss_end__@@Base+0xe0e4d4> │ │ │ │ ldrbtmi r4, [r9], #-2359 @ 0xfffff6c9 │ │ │ │ @ instruction: 0xf7e86978 │ │ │ │ - ands lr, lr, r8, asr #26 │ │ │ │ - bvs 1eb4bfc <__bss_end__@@Base+0x1e0dfc4> │ │ │ │ + ands lr, lr, r0, ror #26 │ │ │ │ + bvs 1eb4b84 <__bss_end__@@Base+0x1e0dfe4> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r8, r9, fp, sp, lr} │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ - bvs 1e34c08 <__bss_end__@@Base+0x1d8dfd0> │ │ │ │ + bvs 1e34b90 <__bss_end__@@Base+0x1d8dff0> │ │ │ │ eorne pc, r0, r1, asr r8 @ │ │ │ │ ldmdbvs r9!, {r3, r7, r8, r9, fp, sp, lr} │ │ │ │ strmi r0, [r1], #-201 @ 0xffffff37 │ │ │ │ ldrdeq lr, [r0, -r1] │ │ │ │ smlabteq r2, sp, r9, lr │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ - bvs eb512c <__bss_end__@@Base+0xe0e4f4> │ │ │ │ + bvs eb50b4 <__bss_end__@@Base+0xe0e514> │ │ │ │ ldrbtmi r4, [r9], #-2344 @ 0xfffff6d8 │ │ │ │ @ instruction: 0xf7e86978 │ │ │ │ - ldmibvs fp!, {r3, r5, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmibvs fp!, {r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ mvnsvs r3, r1, lsl #6 │ │ │ │ - bvs ef513c <__bss_end__@@Base+0xe4e504> │ │ │ │ + bvs ef50c4 <__bss_end__@@Base+0xe4e524> │ │ │ │ @ instruction: 0xf77f429a │ │ │ │ - bvs f06624 <__bss_end__@@Base+0xe5f9ec> │ │ │ │ + bvs f065ac <__bss_end__@@Base+0xe5fa0c> │ │ │ │ eorsvs r3, fp, #67108864 @ 0x4000000 │ │ │ │ - bvs 1eb4c50 <__bss_end__@@Base+0x1e0e018> │ │ │ │ + bvs 1eb4bd8 <__bss_end__@@Base+0x1e0e038> │ │ │ │ eorcc pc, r2, r3, asr r8 @ │ │ │ │ - bvs eb59d8 <__bss_end__@@Base+0xe0eda0> │ │ │ │ + bvs eb5960 <__bss_end__@@Base+0xe0edc0> │ │ │ │ @ instruction: 0xf77f429a │ │ │ │ - bvs 1f06600 <__bss_end__@@Base+0x1e5f9c8> │ │ │ │ + bvs 1f06588 <__bss_end__@@Base+0x1e5f9e8> │ │ │ │ rsbsvs r3, fp, #67108864 @ 0x4000000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r6, r9, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf6ff429a │ │ │ │ svclt 0x0000ae4f │ │ │ │ strcc fp, [ip, -r0, lsl #30]! │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ svclt 0x000083f0 │ │ │ │ - muleq r3, r0, r7 │ │ │ │ - andeq r7, r3, sl, lsl #15 │ │ │ │ - @ instruction: 0x000377be │ │ │ │ + andeq r7, r3, r8, lsl #14 │ │ │ │ + andeq r7, r3, r2, lsl #14 │ │ │ │ + andeq r7, r3, r6, lsr r7 │ │ │ │ + andeq r7, r3, lr, lsr r7 │ │ │ │ + muleq r3, r6, r7 │ │ │ │ + andeq r7, r3, r6, lsr #15 │ │ │ │ + andeq r7, r3, sl, lsr #15 │ │ │ │ + muleq r3, ip, r7 │ │ │ │ + muleq r3, r8, r7 │ │ │ │ + muleq r3, r2, r7 │ │ │ │ + andeq r7, r3, lr, lsl #15 │ │ │ │ + muleq r3, r6, r7 │ │ │ │ + muleq r3, lr, r7 │ │ │ │ + andeq r7, r3, r6, lsr #15 │ │ │ │ andeq r7, r3, r6, asr #15 │ │ │ │ - andeq r7, r3, lr, lsl r8 │ │ │ │ - andeq r7, r3, lr, lsr #16 │ │ │ │ - andeq r7, r3, r2, lsr r8 │ │ │ │ - andeq r7, r3, r4, lsr #16 │ │ │ │ - andeq r7, r3, r0, lsr #16 │ │ │ │ - andeq r7, r3, sl, lsl r8 │ │ │ │ - andeq r7, r3, r6, lsl r8 │ │ │ │ - andeq r7, r3, lr, lsl r8 │ │ │ │ - andeq r7, r3, r6, lsr #16 │ │ │ │ - andeq r7, r3, lr, lsr #16 │ │ │ │ - andeq r7, r3, lr, asr #16 │ │ │ │ - andeq r7, r3, r0, ror #16 │ │ │ │ - andeq r7, r3, r2, lsl #17 │ │ │ │ - @ instruction: 0x000378b4 │ │ │ │ - andeq r7, r3, r0, asr #16 │ │ │ │ - andeq r7, r3, r8, lsl r8 │ │ │ │ - andeq r7, r3, sl, lsl #15 │ │ │ │ - andeq r7, r3, r2, ror #14 │ │ │ │ + ldrdeq r7, [r3], -r8 │ │ │ │ + strdeq r7, [r3], -sl │ │ │ │ + andeq r7, r3, ip, lsr #16 │ │ │ │ + @ instruction: 0x000377b8 │ │ │ │ + muleq r3, r0, r7 │ │ │ │ + andeq r7, r3, r2, lsl #14 │ │ │ │ + ldrdeq r7, [r3], -sl │ │ │ │ adclt fp, lr, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r4, lsl #30 │ │ │ │ movwcs r6, #57 @ 0x39 │ │ │ │ adccc pc, r0, r7, asr #17 │ │ │ │ ldrbtmi r4, [fp], #-2936 @ 0xfffff488 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - ldc 7, cr15, [ip], {232} @ 0xe8 │ │ │ │ + ldc 7, cr15, [r4], #-928 @ 0xfffffc60 │ │ │ │ @ instruction: 0xf8c74603 │ │ │ │ @ instruction: 0xf8d7309c │ │ │ │ - blcs 26c80 │ │ │ │ + blcs 26c08 │ │ │ │ andscs sp, r4, r4, lsl #2 │ │ │ │ @ instruction: 0xf95ef7fd │ │ │ │ sbcs r2, fp, r0, lsl #6 │ │ │ │ - blvs 1674b0c <__bss_end__@@Base+0x15cded4> │ │ │ │ + blvs 1674a94 <__bss_end__@@Base+0x15cdef4> │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ - blvs 674b1c <__bss_end__@@Base+0x5cdee4> │ │ │ │ + blvs 674aa4 <__bss_end__@@Base+0x5cdf04> │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ - blvs ff674b2c <__bss_end__@@Base+0xff5cdef4> │ │ │ │ + blvs ff674ab4 <__bss_end__@@Base+0xff5cdf14> │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ - blvs fe674b3c <__bss_end__@@Base+0xfe5cdf04> │ │ │ │ + blvs fe674ac4 <__bss_end__@@Base+0xfe5cdf24> │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ movteq pc, #263 @ 0x107 @ │ │ │ │ @ instruction: 0x209cf8d7 │ │ │ │ @ instruction: 0x46182150 │ │ │ │ - b fefd8a0c <__bss_end__@@Base+0xfef31dd4> │ │ │ │ + b ff4d8994 <__bss_end__@@Base+0xff431df4> │ │ │ │ tstcc r0, #3866624 @ 0x3b0000 │ │ │ │ eoreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ subeq pc, r0, r7, lsl #2 │ │ │ │ ldrbtmi r4, [r9], #-2393 @ 0xfffff6a7 │ │ │ │ - b fe558a20 <__bss_end__@@Base+0xfe4b1de8> │ │ │ │ + b fea589a8 <__bss_end__@@Base+0xfe9b1e08> │ │ │ │ movwcs lr, #43479 @ 0xa9d7 │ │ │ │ stmib r1, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ adds r2, r7, r2, lsl #6 │ │ │ │ movteq pc, #263 @ 0x107 @ │ │ │ │ @ instruction: 0x209cf8d7 │ │ │ │ @ instruction: 0x46182150 │ │ │ │ - b fe9d8a3c <__bss_end__@@Base+0xfe931e04> │ │ │ │ - blcs 2c2ac │ │ │ │ + b feed89c4 <__bss_end__@@Base+0xfee31e24> │ │ │ │ + blcs 2c234 │ │ │ │ addshi pc, r2, r0 │ │ │ │ @ instruction: 0xf8c72300 │ │ │ │ ands r3, r9, r4, lsr #1 │ │ │ │ subeq pc, r0, #-1073741823 @ 0xc0000001 │ │ │ │ ldrdcc pc, [r4], r7 @ │ │ │ │ ldmdavc r9, {r0, r1, r4, sl, lr} │ │ │ │ eorseq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ @@ -23857,17 +23852,17 @@ │ │ │ │ ldrdcc pc, [r4], r7 @ │ │ │ │ @ instruction: 0xdc072b03 │ │ │ │ subeq pc, r0, #-1073741823 @ 0xc0000001 │ │ │ │ ldrdcc pc, [r4], r7 @ │ │ │ │ ldmdavc fp, {r0, r1, r4, sl, lr} │ │ │ │ bicsle r2, r9, r0, lsl #22 │ │ │ │ teqpeq r8, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ - blmi e6c364 <__bss_end__@@Base+0xdc572c> │ │ │ │ + blmi e6c2ec <__bss_end__@@Base+0xdc574c> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - stcl 7, cr15, [r6, #-928] @ 0xfffffc60 │ │ │ │ + ldcl 7, cr15, [r0, #-928] @ 0xfffffc60 │ │ │ │ addseq pc, r8, r7, asr #17 │ │ │ │ @ instruction: 0x3098f8d7 │ │ │ │ tstle r3, r0, lsl #22 │ │ │ │ @ instruction: 0xf8c72301 │ │ │ │ subs r3, r6, r0, lsr #1 │ │ │ │ teqpeq r4, r7, lsl #2 @ p-variant is OBSOLETE │ │ │ │ eorseq pc, r0, #-1073741823 @ 0xc0000001 │ │ │ │ @@ -23876,66 +23871,66 @@ │ │ │ │ @ instruction: 0xf1079303 │ │ │ │ movwls r0, #8976 @ 0x2310 │ │ │ │ tstpeq r8, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ @ instruction: 0xf1079301 │ │ │ │ movwls r0, #800 @ 0x320 │ │ │ │ stmdbmi r9!, {r0, r1, r3, r9, sl, lr} │ │ │ │ @ instruction: 0xf7e84479 │ │ │ │ - blvs 1ed540c <__bss_end__@@Base+0x1e2e7d4> │ │ │ │ + blvs 1ed53e4 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0x000375b6 │ │ │ │ + andeq r7, r3, r8, lsr r5 │ │ │ │ + strdeq r7, [r3], -ip │ │ │ │ sbclt fp, r2, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r2, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldrbtmi r4, [fp], #-3012 @ 0xfffff43c │ │ │ │ ldmvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - bl 758ba4 <__bss_end__@@Base+0x6b1f6c> │ │ │ │ + bl d58b2c <__bss_end__@@Base+0xcb1f8c> │ │ │ │ @ instruction: 0xf8c74603 │ │ │ │ - blmi ff066fec <__bss_end__@@Base+0xfefc03b4> │ │ │ │ + blmi ff066f74 <__bss_end__@@Base+0xfefc03d4> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7e868b8 │ │ │ │ - @ instruction: 0x4603eb14 │ │ │ │ + strmi lr, [r3], -ip, lsr #22 │ │ │ │ rscscc pc, r4, r7, asr #17 │ │ │ │ ldrsbtcc pc, [r8], #135 @ 0x87 @ │ │ │ │ andle r2, r3, r0, lsl #22 │ │ │ │ ldrsbtcc pc, [r4], #135 @ 0x87 @ │ │ │ │ tstle r4, r0, lsl #22 │ │ │ │ @ instruction: 0xf7fd2014 │ │ │ │ movwcs pc, #2129 @ 0x851 @ │ │ │ │ @@ -23955,26 +23950,26 @@ │ │ │ │ @ instruction: 0xf04f6b99 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r1, {r8, r9}^ │ │ │ │ @ instruction: 0xf1072300 │ │ │ │ @ instruction: 0xf8d70394 │ │ │ │ ldrshcs r2, [r0, #-8] │ │ │ │ @ instruction: 0xf7e84618 │ │ │ │ - @ instruction: 0x4603e9b2 │ │ │ │ + strmi lr, [r3], -r6, asr #19 │ │ │ │ tstle r9, r0, lsl #22 │ │ │ │ ldrsbteq pc, [r8], #135 @ 0x87 @ │ │ │ │ - stmib r4!, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib r8!, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrsbteq pc, [r4], #135 @ 0x87 @ │ │ │ │ - stmib r0!, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib r4!, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xe12f2300 │ │ │ │ tstcc r0, #8060928 @ 0x7b0000 │ │ │ │ eorseq pc, r0, #-1073741823 @ 0xc0000001 │ │ │ │ addseq pc, r4, r7, lsl #2 │ │ │ │ ldrbtmi r4, [r9], #-2457 @ 0xfffff667 │ │ │ │ - ldmdb sl!, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib lr, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ movwcs lr, #51671 @ 0xc9d7 │ │ │ │ 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lsl #6 │ │ │ │ teqpeq ip, r7, lsl #2 @ p-variant is OBSOLETE │ │ │ │ eorseq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ addseq pc, r4, r7, lsl #2 │ │ │ │ msreq CPSR_, #-1073741823 @ 0xc0000001 │ │ │ │ @ instruction: 0xf1079301 │ │ │ │ movwls r0, #808 @ 0x328 │ │ │ │ ldmdbmi r3!, {r0, r1, r3, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7e84479 │ │ │ │ - @ instruction: 0xf107e92c │ │ │ │ + @ instruction: 0xf107e940 │ │ │ │ @ instruction: 0xf8d70340 │ │ │ │ ldrshcs r2, [r0, #-4] │ │ │ │ @ instruction: 0xf7e84618 │ │ │ │ - strmi lr, [r3], -r4, asr #18 │ │ │ │ + @ instruction: 0x4603e958 │ │ │ │ tstle r9, r0, lsl #22 │ │ │ │ ldrsbteq pc, [r8], #135 @ 0x87 @ │ │ │ │ - ldmdb r6!, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb sl, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrsbteq pc, [r4], #135 @ 0x87 @ │ │ │ │ - ldmdb r2!, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r6, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ sbc r2, r1, r0, lsl #6 │ │ │ │ teqpeq ip, r7, lsl #2 @ p-variant is OBSOLETE │ │ │ │ eorseq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ subeq pc, r0, r7, lsl #2 │ │ │ │ tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ @ instruction: 0xf1079301 │ │ │ │ movwls r0, #792 @ 0x318 │ │ │ │ stmdbmi r1!, {r0, r1, r3, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7e84479 │ │ │ │ - blvs ffed51b8 <__bss_end__@@Base+0xffe2e580> │ │ │ │ + blvs ffed5190 <__bss_end__@@Base+0xffe2e5f0> │ │ │ │ addsmi r6, sl, #191488 @ 0x2ec00 │ │ │ │ - blvs fef11e78 <__bss_end__@@Base+0xfee6b240> │ │ │ │ - blvs feea79b0 <__bss_end__@@Base+0xfee00d78> │ │ │ │ + blvs fef11e00 <__bss_end__@@Base+0xfee6b260> │ │ │ │ + blvs feea7938 <__bss_end__@@Base+0xfee00d98> │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldrmi r0, [r3], #-4058 @ 0xfffff026 │ │ │ │ @ instruction: 0x461a105b │ │ │ │ ldrmi r6, [r3], #-3067 @ 0xfffff405 │ │ │ │ rsccc pc, r8, r7, asr #17 │ │ │ │ - blvs 6b4fb0 <__bss_end__@@Base+0x60e378> │ │ │ │ + blvs 6b4f38 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│ │ │ │ @ instruction: 0xf8c73301 │ │ │ │ @ instruction: 0xf8d730fc │ │ │ │ @@ -24066,71 +24061,71 @@ │ │ │ │ svcge 0x006ff6ff │ │ │ │ ldrsbtcc pc, [r0], #135 @ 0x87 @ │ │ │ │ rscscc pc, ip, r7, asr #17 │ │ │ │ @ instruction: 0xf107e04f │ │ │ │ @ instruction: 0xf8d70394 │ │ │ │ ldrshcs r2, [r0, #-8] │ │ │ │ @ instruction: 0xf7e84618 │ │ │ │ - @ instruction: 0x4603e8d4 │ │ │ │ + strmi lr, [r3], -r8, ror #17 │ │ │ │ tstle r9, r0, lsl #22 │ │ │ │ ldrsbteq pc, [r8], #135 @ 0x87 @ │ │ │ │ - stmia r6, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm sl, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrsbteq pc, [r4], #135 @ 0x87 @ │ │ │ │ - stmia r2, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm r6, {r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ subs r2, r1, r0, lsl #6 │ │ │ │ teqpeq ip, r7, lsl #2 @ p-variant is OBSOLETE │ │ │ │ eorseq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ addseq pc, r4, r7, lsl #2 │ │ │ │ msreq CPSR_, #-1073741823 @ 0xc0000001 │ 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│ │ │ │ + andeq r7, r3, r2, asr #3 │ │ │ │ + andeq r5, r3, r4, rrx │ │ │ │ + andeq r7, r3, sl, lsr r0 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r6, r3, sl, asr pc │ │ │ │ + andeq r6, r3, ip, ror #25 │ │ │ │ + andeq r6, r3, sl, lsr #25 │ │ │ │ + andeq r6, r3, ip, asr #24 │ │ │ │ + andeq r6, r3, r2, lsr ip │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r1, sp, lr, pc}^ │ │ │ │ rsbsvs r3, fp, r1, lsl #6 │ │ │ │ - cdp 7, 1, cr15, cr2, cr7, {7} │ │ │ │ + cdp 7, 2, cr15, cr10, cr7, {7} │ │ │ │ ldmdavs sl, {r0, r1, r9, sl, lr} │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldrmi r0, [r3], #-91 @ 0xffffffa5 │ │ │ │ vst2.8 {d8-d9}, [r3 :64], fp │ │ │ │ - blcs 30378 │ │ │ │ + blcs 30300 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ - blcs 397ec │ │ │ │ + blcs 39774 │ │ │ │ ldmdavs fp!, {r0, r8, ip, lr, pc}^ │ │ │ │ ldmdavs r8!, {r0, r5, sp, lr, pc}^ │ │ │ │ - stcl 7, cr15, [sl, #-924] @ 0xfffffc64 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{5} │ │ │ │ + cdp 8, 11, cr14, cr0, cr12, {6} │ │ │ │ vldr d6, [r7, #256] @ 0x100 │ │ │ │ vadd.f64 d7, d6, d10 │ │ │ │ vstr d7, [r7, #284] @ 0x11c │ │ │ │ vldr d7, [r7, #32] │ │ │ │ vldr d6, [r7, #144] @ 0x90 │ │ │ │ vmul.f64 d7, d7, d8 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ @@ -25201,79 +25196,79 @@ │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vmov.32 r7, d7[1] │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmul.f64 d7, d5, d8 │ │ │ │ vdiv.f64 d7, d6, d7 │ │ │ │ vmov.f64 d5, #7 @ 0x40380000 2.875 │ │ │ │ @ instruction: 0xf7e70b45 │ │ │ │ - stc 8, cr14, [r7, #736] @ 0x2e0 │ │ │ │ + stc 8, cr14, [r7, #824] @ 0x338 │ │ │ │ vldr d0, [r7, #24] │ │ │ │ - vldr d7, [pc, #24] @ 1c020 │ │ │ │ + vldr d7, [pc, #24] @ 1bfa8 │ │ │ │ vmov.16 d7[2], r6 │ │ │ │ @ instruction: 0xf8d77b06 │ │ │ │ stc 0, cr3, [r3, #768] @ 0x300 │ │ │ │ vldr d7, [r7, #8] │ │ │ │ vldr d6, [r7, #144] @ 0x90 │ │ │ │ vmul.f64 d7, d6, d8 │ │ │ │ vldr d7, [r7, #28] │ │ │ │ vmov.32 r6, d6[1] │ │ │ │ vldr d8, [r7, #284] @ 0x11c │ │ │ │ @ instruction: 0xf7e70b06 │ │ │ │ - mrc 8, 5, lr, cr0, cr2, {7} │ │ │ │ + @ instruction: 0xeeb0e90a │ │ │ │ vnmul.f64 d7, d8, d0 │ │ │ │ vldr d8, [r7, #28] │ │ │ │ vldr d6, [r7] │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vldr d9, [r7, #284] @ 0x11c │ │ │ │ @ instruction: 0xf7e70b06 │ │ │ │ - @ instruction: 0xeeb0ea38 │ │ │ │ + vmov.f32 s28, s16 │ │ │ │ vnmul.f64 d7, d9, d0 │ │ │ │ vadd.f64 d7, d8, d7 │ │ │ │ @ instruction: 0xf8d77b07 │ │ │ │ stc 0, cr3, [r3, #768] @ 0x300 │ │ │ │ vldr d7, [r7, #16] │ │ │ │ vldr d1, [r7, #16] │ │ │ │ @ instruction: 0xf7e70b02 │ │ │ │ - @ instruction: 0xed87e9c4 │ │ │ │ + @ instruction: 0xed87e9d4 │ │ │ │ vldr d0, [r7, #96] @ 0x60 │ │ │ │ vmov.32 r7, d5[1] │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ strle pc, [r7, #-2576] @ 0xfffff5f0 │ │ │ │ - blvc 6576e0 <__bss_end__@@Base+0x5b0aa8> │ │ │ │ - blvs 817704 <__bss_end__@@Base+0x770acc> │ │ │ │ - blvc 1d7968 <__bss_end__@@Base+0x130d30> │ │ │ │ - blvc 6576ac <__bss_end__@@Base+0x5b0a74> │ │ │ │ - blvc 6576f0 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sl, r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - bcc fe4579b4 <__bss_end__@@Base+0xfe3b0d7c> │ │ │ │ - blvc ffa17c7c <__bss_end__@@Base+0xff971044> │ │ │ │ + bcc fe45793c <__bss_end__@@Base+0xfe3b0d9c> │ │ │ │ + blvc ffa17c04 <__bss_end__@@Base+0xff971064> │ │ │ │ stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ movwcs r7, #6916 @ 0x1b04 │ │ │ │ ldmdavs fp!, {r1, r2, r6, r7, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf003681b │ │ │ │ - blcs 1cdbc │ │ │ │ + blcs 1cd44 │ │ │ │ ldmdavs fp!, {r4, r8, ip, lr, pc}^ │ │ │ │ vtst.8 d22, d8, d10 │ │ │ │ vorr.i32 d21, #24320 @ 0x00005f00 │ │ │ │ - blx fe0e116e <__bss_end__@@Base+0xfe03a536> │ │ │ │ + blx fe0e10f6 <__bss_end__@@Base+0xfe03a556> │ │ │ │ cmpne r9, r2, lsl #6 │ │ │ │ - bne ff2e2114 <__bss_end__@@Base+0xff23b4dc> │ │ │ │ - blx 6475e <__bss_start@@Base+0x96be> │ │ │ │ - bne ff518ddc <__bss_end__@@Base+0xff4721a4> │ │ │ │ + bne ff2e209c <__bss_end__@@Base+0xff23b4fc> │ │ │ │ + blx 646e6 <__bss_start@@Base+0x96de> │ │ │ │ + bne ff518d64 <__bss_end__@@Base+0xff4721c4> │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ tstppl pc, #72, 4 @ p-variant is OBSOLETE @ 0x80000004 │ │ │ │ mvnne pc, #1342177292 @ 0x5000000c │ │ │ │ movwne pc, #11139 @ 0x2b83 @ │ │ │ │ @ instruction: 0x17d311d9 │ │ │ │ vst1.64 {d17-d18}, [pc], fp │ │ │ │ - blx 78912 <__bss_start@@Base+0x1d872> │ │ │ │ - bne ff518e00 <__bss_end__@@Base+0xff4721c8> │ │ │ │ + blx 7889a <__bss_start@@Base+0x1d892> │ │ │ │ + bne ff518d88 <__bss_end__@@Base+0xff4721e8> │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ldrtvs r2, [fp], #-769 @ 0xfffffcff │ │ │ │ adcsvs r2, fp, r0, lsl #6 │ │ │ │ rscsvs r2, fp, pc, lsl r3 │ │ │ │ tstcc ip, #15104 @ 0x3b00 │ │ │ │ tstcs pc, #-1073741810 @ 0xc000000e │ │ │ │ tstcs lr, #-1073741794 @ 0xc000001e │ │ │ │ @@ -25343,115 +25338,115 @@ │ │ │ │ tstcs pc, #-1342177277 @ 0xb0000003 │ │ │ │ tstcs pc, #-1342177273 @ 0xb0000007 │ │ │ │ tstcs lr, #-1342177269 @ 0xb000000b │ │ │ │ tstcs pc, #-1342177265 @ 0xb000000f │ │ │ │ tstcs lr, #-335544320 @ 0xec000000 │ │ │ │ tstcs pc, #-335544319 @ 0xec000001 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r7, r8, r9, sp, lr}^ │ │ │ │ - blcs 363a4 │ │ │ │ + blcs 3632c │ │ │ │ ldmdavs fp!, {r0, r1, r8, sl, fp, ip, lr, pc}^ │ │ │ │ - blcs 3363ac <__bss_end__@@Base+0x28f774> │ │ │ │ + blcs 336334 <__bss_end__@@Base+0x28f794> │ │ │ │ ldmdavs sl!, {r1, r3, r8, sl, fp, ip, lr, pc} │ │ │ │ ldrbtmi r4, [fp], #-2879 @ 0xfffff4c1 │ │ │ │ @ instruction: 0x46194610 │ │ │ │ ldrmi r2, [sl], -r2, asr #6 │ │ │ │ - svc 0x00ecf7e6 │ │ │ │ + stmda r4, {r0, r1, r2, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ rsb r2, sp, r0, lsl #6 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ vstrle d2, [sl, #-0] │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ movtcc r0, #32923 @ 0x809b │ │ │ │ @ instruction: 0xf853443b │ │ │ │ addsmi r3, sl, #64, 24 @ 0x4000 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r5, r8, sl, fp, ip, lr, pc}^ │ │ │ │ ldmdavs fp!, {r0, r3, r4, r6, fp, sp, lr}^ │ │ │ │ addseq r6, fp, fp, asr r8 │ │ │ │ ldrtmi r3, [fp], #-840 @ 0xfffffcb8 │ │ │ │ mcrrcc 8, 5, pc, r0, cr3 @ │ │ │ │ - blmi bedaf4 <__bss_end__@@Base+0xb46ebc> │ │ │ │ + blmi beda7c <__bss_end__@@Base+0xb46edc> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - ldmda lr, {r0, r1, r2, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - bmi b76384 <__bss_end__@@Base+0xacf74c> │ │ │ │ + ldmda r6!, {r0, r1, r2, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bmi b7630c <__bss_end__@@Base+0xacf76c> │ │ │ │ @ instruction: 0x4614447a │ │ │ │ @ instruction: 0xf104469c │ │ │ │ strbtmi r0, [r5], -r0, lsr #28 │ │ │ │ cdpgt 6, 0, cr4, cr15, cr6, {1} │ │ │ │ rsbvs r6, r9, r8, lsr #32 │ │ │ │ rscvs r6, fp, sl, lsr #1 │ │ │ │ @ instruction: 0xf10c3410 │ │ │ │ ldrbmi r0, [r4, #-3088]! @ 0xfffff3f0 │ │ │ │ @ instruction: 0x4663d1f3 │ │ │ │ ldmdavs r0, {r1, r5, r9, sl, lr} │ │ │ │ movwcs r6, #24 │ │ │ │ movwcs lr, #4150 @ 0x1036 │ │ │ │ strd r6, [ip], -fp │ │ │ │ - blcc 772bc <__bss_start@@Base+0x1c21c> │ │ │ │ + blcc 77244 <__bss_start@@Base+0x1c23c> │ │ │ │ movtcc r0, #32923 @ 0x809b │ │ │ │ @ instruction: 0xf853443b │ │ │ │ ldclvs 12, cr3, [sl], #-256 @ 0xffffff00 │ │ │ │ ldrbtvs r4, [fp], #-1043 @ 0xfffffbed │ │ │ │ movwcc r6, #7163 @ 0x1bfb │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sp, lr}^ │ │ │ │ - blvs ffeb6458 <__bss_end__@@Base+0xffe0f820> │ │ │ │ + blvs ffeb63e0 <__bss_end__@@Base+0xffe0f840> │ │ │ │ stclle 2, cr4, [sp, #616]! @ 0x268 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldrmi r6, [r3], #-3194 @ 0xfffff386 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, sl, sp, lr}^ │ │ │ │ mcr 8, 0, r6, cr7, cr11, {0} │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ @ instruction: 0x6c7b6be7 │ │ │ │ vmla.f64 d3, d7, d1 │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ @ instruction: 0x6c3b4be7 │ │ │ │ - bcc fe457b34 <__bss_end__@@Base+0xfe3b0efc> │ │ │ │ - blvc ffa17dfc <__bss_end__@@Base+0xff9711c4> │ │ │ │ - blpl 21799c <__bss_end__@@Base+0x170d64> │ │ │ │ - blpl 197c00 <__bss_end__@@Base+0xf0fc8> │ │ │ │ - blvc 197d38 <__bss_end__@@Base+0xf1100> │ │ │ │ - blvc 217c04 <__bss_end__@@Base+0x170fcc> │ │ │ │ + bcc fe457abc <__bss_end__@@Base+0xfe3b0f1c> │ │ │ │ + blvc ffa17d84 <__bss_end__@@Base+0xff9711e4> │ │ │ │ + blpl 217924 <__bss_end__@@Base+0x170d84> │ │ │ │ + blpl 197b88 <__bss_end__@@Base+0xf0fe8> │ │ │ │ + blvc 197cc0 <__bss_end__@@Base+0xf1120> │ │ │ │ + blvc 217b8c <__bss_end__@@Base+0x170fec> │ │ │ │ stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ movwcs r7, #6916 @ 0x1b04 │ │ │ │ smlaldcc r4, ip, r8, r6 │ │ │ │ ldcllt 6, cr4, [r0, #756]! @ 0x2f4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbsmi sp, r6, r0 │ │ │ │ - andeq r9, r3, r6, ror #22 │ │ │ │ - andeq r9, r3, r4, ror #22 │ │ │ │ - andeq r9, r3, r0, lsl #23 │ │ │ │ + ldrdeq r9, [r3], -lr │ │ │ │ + ldrdeq r9, [r3], -ip │ │ │ │ + strdeq r9, [r3], -r8 │ │ │ │ addslt fp, ip, r0, lsl #11 │ │ │ │ stc 15, cr10, [r7] │ │ │ │ rsbsvs r0, r8, r2, lsl #22 │ │ │ │ ldmib r7, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ stmib r7, {r1, r8, r9, sp}^ │ │ │ │ @ instruction: 0xf1072318 │ │ │ │ eorcs r0, r4, #48, 6 @ 0xc0000000 │ │ │ │ ldrmi r2, [r8], -r0, lsl #2 │ │ │ │ - cdp 7, 8, cr15, cr10, cr6, {7} │ │ │ │ + cdp 7, 10, cr15, cr0, cr6, {7} │ │ │ │ tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ tstcs r0, r0, lsr #4 │ │ │ │ @ instruction: 0xf7e64618 │ │ │ │ - ldmdavs fp!, {r2, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + ldmdavs fp!, {r1, r3, r4, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ andsvc r2, sl, r0, lsl #4 │ │ │ │ - blcs f6578 <__bss_end__@@Base+0x4f940> │ │ │ │ + blcs f6500 <__bss_end__@@Base+0x4f960> │ │ │ │ andscs sp, r5, r2, lsl #26 │ │ │ │ stc2 7, cr15, [r0], #1004 @ 0x3ec │ │ │ │ ldrbtvs r2, [fp], r0, lsl #6 │ │ │ │ ldc 0, cr14, [r7, #584] @ 0x248 │ │ │ │ vmov.u8 r7, d13[4] │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ @ instruction: 0x6efb2a90 │ │ │ │ cmncc r0, #155 @ 0x9b │ │ │ │ @ instruction: 0xf843443b │ │ │ │ mrcvs 12, 7, r2, cr11, cr12, {0} │ │ │ │ andsle r2, r9, r2, lsl #22 │ │ │ │ - blcs b7fa8 <__bss_end__@@Base+0x11370> │ │ │ │ + blcs b7f30 <__bss_end__@@Base+0x11390> │ │ │ │ mrcvs 12, 7, sp, cr11, cr14, {0} │ │ │ │ andle r2, r3, r0, lsl #22 │ │ │ │ - blcs 77fb4 <__bss_start@@Base+0x1cf14> │ │ │ │ + blcs 77f3c <__bss_start@@Base+0x1cf34> │ │ │ │ ands sp, r7, r8 │ │ │ │ andseq pc, r0, #-1073741823 @ 0xc0000001 │ │ │ │ movtpl pc, #16966 @ 0x4246 @ │ │ │ │ msreq SPSR_sxc, #192, 4 │ │ │ │ and r6, pc, r3, lsl r0 @ │ │ │ │ andseq pc, r0, #-1073741823 @ 0xc0000001 │ │ │ │ movtne pc, #54854 @ 0xd646 @ │ │ │ │ @@ -25460,36 +25455,36 @@ │ │ │ │ andseq pc, r0, #-1073741823 @ 0xc0000001 │ │ │ │ cmpppl r3, #1610612740 @ p-variant is OBSOLETE @ 0x60000004 │ │ │ │ msreq SPSR_xc, #192, 4 │ │ │ │ svclt 0x00006013 │ │ │ │ @ instruction: 0x009b6efb │ │ │ │ ldrtmi r3, [fp], #-880 @ 0xfffffc90 │ │ │ │ ldccc 8, cr15, [ip], {83} @ 0x53 │ │ │ │ - bcc fe457c28 <__bss_end__@@Base+0xfe3b0ff0> │ │ │ │ - blvc ffa17ef0 <__bss_end__@@Base+0xff9712b8> │ │ │ │ - blvs 657a70 <__bss_end__@@Base+0x5b0e38> │ │ │ │ - blvc 1217cf0 <__bss_end__@@Base+0x11710b8> │ │ │ │ - blvs bd7a98 <__bss_end__@@Base+0xb30e60> │ │ │ │ - blvc 1d7cbc <__bss_end__@@Base+0x131084> │ │ │ │ - blvc 657a40 <__bss_end__@@Base+0x5b0e08> │ │ │ │ - blcc 76614 <__bss_start@@Base+0x1b574> │ │ │ │ + bcc fe457bb0 <__bss_end__@@Base+0xfe3b1010> │ │ │ │ + blvc ffa17e78 <__bss_end__@@Base+0xff9712d8> │ │ │ │ + blvs 6579f8 <__bss_end__@@Base+0x5b0e58> │ │ │ │ + blvc 1217c78 <__bss_end__@@Base+0x11710d8> │ │ │ │ + blvs bd7a20 <__bss_end__@@Base+0xb30e80> │ │ │ │ + blvc 1d7c44 <__bss_end__@@Base+0x1310a4> │ │ │ │ + blvc 6579c8 <__bss_end__@@Base+0x5b0e28> │ │ │ │ + blcc 7659c <__bss_start@@Base+0x1b594> │ │ │ │ addsmi r6, sl, #4000 @ 0xfa0 │ │ │ │ ldc 1, cr13, [r7, #88] @ 0x58 │ │ │ │ vmov.32 r7, d3[1] │ │ │ │ vmov.f64 d6, #78 @ 0x3e700000 0.2343750 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ - blle 39ac80 <__bss_end__@@Base+0x2f4048> │ │ │ │ + blle 39ac08 <__bss_end__@@Base+0x2f4068> │ │ │ │ @ instruction: 0x009b6efb │ │ │ │ ldrtmi r3, [fp], #-880 @ 0xfffffc90 │ │ │ │ ldccc 8, cr15, [ip], {83} @ 0x53 │ │ │ │ mrcvs 12, 7, r1, cr11, cr10, {2} │ │ │ │ cmncc r0, #155 @ 0x9b │ │ │ │ @ instruction: 0xf843443b │ │ │ │ ands r2, sl, ip, lsl ip │ │ │ │ - blcc 7664c <__bss_start@@Base+0x1b5ac> │ │ │ │ + blcc 765d4 <__bss_start@@Base+0x1b5cc> │ │ │ │ addsmi r6, sl, #4000 @ 0xfa0 │ │ │ │ ldc 1, cr13, [r7, #84] @ 0x54 │ │ │ │ vmov.32 r7, d11[1] │ │ │ │ vmov.f64 d6, #78 @ 0x3e700000 0.2343750 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ stmdale ip, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x009b6efb │ │ │ │ @@ -25501,351 +25496,351 @@ │ │ │ │ mrcvs 12, 7, r2, cr11, cr12, {0} │ │ │ │ cmncc r0, #155 @ 0x9b │ │ │ │ @ instruction: 0xf853443b │ │ │ │ @ instruction: 0xf1072c1c │ │ │ │ @ instruction: 0xf1070310 │ │ │ │ stmdbmi sp, {r4, r5} │ │ │ │ @ instruction: 0xf7e74479 │ │ │ │ - @ instruction: 0xf107e8aa │ │ │ │ + @ instruction: 0xf107e8b4 │ │ │ │ @ instruction: 0x46190330 │ │ │ │ @ instruction: 0xf7e66838 │ │ │ │ - mrcvs 15, 7, lr, cr11, cr8, {5} │ │ │ │ + cdpvs 15, 15, cr14, cr11, cr8, {6} │ │ │ │ ldrbtvs r3, [fp], r1, lsl #6 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r6, r7, r9, sl, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf6ff429a │ │ │ │ svclt 0x0000af68 │ │ │ │ ldrbcc fp, [r0, -r0, lsl #30]! │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ - muleq r3, r4, r9 │ │ │ │ + andeq r9, r3, ip, lsl #18 │ │ │ │ addlt fp, sl, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r2, lsl #30 │ │ │ │ movwcs r6, #4153 @ 0x1039 │ │ │ │ movwcs r6, #507 @ 0x1fb │ │ │ │ @ instruction: 0xf10761bb │ │ │ │ @ instruction: 0xf1070110 │ │ │ │ @ instruction: 0xf107020c │ │ │ │ movwls r0, #788 @ 0x314 │ │ │ │ stmdbmi sl!, {r0, r1, r3, r9, sl, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - stcl 7, cr15, [lr, #-920] @ 0xfffffc68 │ │ │ │ + stcl 7, cr15, [r2, #-920]! @ 0xfffffc68 │ │ │ │ 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instruction: 0xf8d77b06 │ │ │ │ stc 0, cr3, [r3, #992] @ 0x3e0 │ │ │ │ ldmib r7, {r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ @ instruction: 0xf8d72304 │ │ │ │ stmib r1, {r3, r4, r5, r6, r7, ip}^ │ │ │ │ movwcs r2, #778 @ 0x30a │ │ │ │ @@ -26159,15 +26154,15 @@ │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ subsge r9, r2, #3648 @ 0xe40 │ │ │ │ svccc 0x0091df46 │ │ │ │ ldmdbmi r5, {r2, r3, r4, r5, r7, r8, r9, fp, sp}^ │ │ │ │ cmpmi r8, r6, lsr sl │ │ │ │ andmi r0, r0, r0 │ │ │ │ cmpmi r8, r6, lsr #9 │ │ │ │ - bne 190d6d8 <__bss_end__@@Base+0x1866aa0> │ │ │ │ + bne 190d660 <__bss_end__@@Base+0x1866ac0> │ │ │ │ ldrdmi sl, [ip], #-92 @ 0xffffffa4 │ │ │ │ @ instruction: 0x23a29c78 │ │ │ │ svccc 0x00effcb9 │ │ │ │ andeq r0, r0, r0 │ │ │ │ ldrdmi r1, [r3, #-32]! @ 0xffffffe0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ tstmi lr, r0, lsl #9 │ │ │ │ @@ -26179,170 +26174,170 @@ │ │ │ │ svccc 0x004b7367 │ │ │ │ vaddl.u16 q7, d18, d15 │ │ │ │ cdpcc 7, 10, cr8, cr9, cr12, {5} │ │ │ │ @ instruction: 0xf5e55f8f │ │ │ │ cdpcc 3, 1, cr9, cr4, cr12, {2} │ │ │ │ cdphi 7, 13, cr3, cr2, cr5, {0} │ │ │ │ stccc 14, cr5, [r5, #4] │ │ │ │ - bcc 3f3914 <__bss_end__@@Base+0x34ccdc> │ │ │ │ + bcc 3f389c <__bss_end__@@Base+0x34ccfc> │ │ │ │ @ instruction: 0x3cf9b947 │ │ │ │ mvnsle r9, r9, lsr #7 │ │ │ │ ldclcc 0, cr1, [r1], #-184 @ 0xffffff48 │ │ │ │ ldcne 13, cr1, [fp], {91} @ 0x5b │ │ │ │ - blcc ffa2cc6c <__bss_end__@@Base+0xff986034> │ │ │ │ + blcc ffa2cbf4 <__bss_end__@@Base+0xff986054> │ │ │ │ mcrrvs 11, 11, r7, r4, cr11 │ │ │ │ - blcc 18aff60 <__bss_end__@@Base+0x1809328> │ │ │ │ + blcc 18afee8 <__bss_end__@@Base+0x1809348> │ │ │ │ addlt fp, ip, r0, lsl #11 │ │ │ │ stc 15, cr10, [r7] │ │ │ │ vstr d0, [r7, #24] │ │ │ │ rscsvs r1, r8, r4, lsl #22 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ adcsvs r2, fp, #0, 6 │ │ │ │ - blvc 1d85dc <__bss_end__@@Base+0x1319a4> │ │ │ │ - blvs fe558600 <__bss_end__@@Base+0xfe4b19c8> │ │ │ │ - blvc ff1d8a58 <__bss_end__@@Base+0xff131e20> │ │ │ │ - blx 458b50 <__bss_end__@@Base+0x3b1f18> │ │ │ │ + blvc 1d8564 <__bss_end__@@Base+0x1319c4> │ │ │ │ + blvs fe558588 <__bss_end__@@Base+0xfe4b19e8> │ │ │ │ + blvc ff1d89e0 <__bss_end__@@Base+0xff131e40> │ │ │ │ + blx 458ad8 <__bss_end__@@Base+0x3b1f38> │ │ │ │ ldc 4, cr13, [r7, #32] │ │ │ │ - vldr d7, [pc, #24] @ 1cfac │ │ │ │ + vldr d7, [pc, #24] @ 1cf34 │ │ │ │ vmov.32 r6, d20[1] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ vstrle s30, [r4, #-64] @ 0xffffffc0 │ │ │ │ @ instruction: 0xf7fa2017 │ │ │ │ movwcs pc, #7831 @ 0x1e97 @ │ │ │ │ ldc 2, cr6, [r7, #748] @ 0x2ec │ │ │ │ - vldr d7, [pc, #16] @ 1cfc0 │ │ │ │ + vldr d7, [pc, #16] @ 1cf48 │ │ │ │ @ instruction: 0xeeb46b8d │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ strle pc, [r8], #-2576 @ 0xfffff5f0 │ │ │ │ - blvc 15861c <__bss_end__@@Base+0xb19e4> │ │ │ │ - blvs fe2d8640 <__bss_end__@@Base+0xfe231a08> │ │ │ │ - blvc ff1d8a98 <__bss_end__@@Base+0xff131e60> │ │ │ │ - blx 458b90 <__bss_end__@@Base+0x3b1f58> │ │ │ │ + blvc 1585a4 <__bss_end__@@Base+0xb1a04> │ │ │ │ + blvs fe2d85c8 <__bss_end__@@Base+0xfe231a28> │ │ │ │ + blvc ff1d8a20 <__bss_end__@@Base+0xff131e80> │ │ │ │ + blx 458b18 <__bss_end__@@Base+0x3b1f78> │ │ │ │ andscs sp, r8, r4, lsl #26 │ │ │ │ mcr2 7, 4, pc, cr0, cr10, {7} @ │ │ │ │ adcsvs r2, fp, #67108864 @ 0x4000000 │ │ │ │ - blcs 37ac8 │ │ │ │ + blcs 37a50 │ │ │ │ rscshi pc, r2, r0, asr #32 │ │ │ │ - blvc 158640 <__bss_end__@@Base+0xb1a08> │ │ │ │ - blvc ff058abc <__bss_end__@@Base+0xfefb1e84> │ │ │ │ - blx 458bb0 <__bss_end__@@Base+0x3b1f78> │ │ │ │ + blvc 1585c8 <__bss_end__@@Base+0xb1a28> │ │ │ │ + blvc ff058a44 <__bss_end__@@Base+0xfefb1ea4> │ │ │ │ + blx 458b38 <__bss_end__@@Base+0x3b1f98> │ │ │ │ ldc 5, cr13, [r7, #28] │ │ │ │ - vldr d7, [pc, #16] @ 1d004 │ │ │ │ + vldr d7, [pc, #16] @ 1cf8c │ │ │ │ vadd.f64 d6, d23, d0 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #16] │ │ │ │ - vldr d7, [pc, #24] @ 1d01c │ │ │ │ + vldr d7, [pc, #24] @ 1cfa4 │ │ │ │ vmov.16 d7[3], r6 │ │ │ │ - vldr d6, [pc, #24] @ 1d024 │ │ │ │ + vldr d6, [pc, #24] @ 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ff058c84 <__bss_end__@@Base+0xfefb204c> │ │ │ │ - blx 458d78 <__bss_end__@@Base+0x3b2140> │ │ │ │ + blvc 1d8790 <__bss_end__@@Base+0x131bf0> │ │ │ │ + blvc ff058c0c <__bss_end__@@Base+0xfefb206c> │ │ │ │ + blx 458d00 <__bss_end__@@Base+0x3b2160> │ │ │ │ ldmvs fp!, {r0, r1, r8, sl, ip, lr, pc} │ │ │ │ andsvc r2, sl, r3, asr r2 │ │ │ │ ldmvs fp!, {r1, sp, lr, pc} │ │ │ │ andsvc r2, sl, lr, asr #4 │ │ │ │ @ instruction: 0x46186abb │ │ │ │ @ instruction: 0x46bd3730 │ │ │ │ svclt 0x0000bd80 │ │ │ │ @@ -26367,15 +26362,15 @@ │ │ │ │ vldr d6, [r7] │ │ │ │ vmov.f64 d7, #64 @ 0x3e000000 0.125 │ │ │ │ vneg.f64 d22, d7 │ │ │ │ svclt 0x0014fa10 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0x4618b2db │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 15b3ac <__bss_end__@@Base+0xb4774> │ │ │ │ + blvc 15b334 <__bss_end__@@Base+0xb4794> │ │ │ │ addlt r4, r4, r0, ror r7 │ │ │ │ stc 5, cr11, [sp, #-512]! @ 0xfffffe00 │ │ │ │ addlt r8, lr, r4, lsl #22 │ │ │ │ @ instruction: 0xf107af00 │ │ │ │ stm ip, {r4, r6, sl, fp} │ │ │ │ cdp 0, 11, cr0, cr0, cr15, {0} │ │ │ │ vmov.f64 d6, d4 │ │ │ │ @@ -26384,132 +26379,132 @@ │ │ │ │ vstr d1, [r7, #32] │ │ │ │ vstr d2, [r7, #40] @ 0x28 │ │ │ │ vstr d3, [r7] │ │ │ │ vstr d6, [r7, #8] │ │ │ │ vldr d7, [r7, #16] │ │ │ │ vldr d6, [r7, #32] │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ - vldr d7, [pc, #284] @ 1d398 │ │ │ │ + vldr d7, [pc, #284] @ 1d320 │ │ │ │ vmul.f64 d6, d7, d20 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #48] @ 0x30 │ │ │ │ vldr d8, [r7] │ │ │ │ @ instruction: 0xf7e60b0c │ │ │ │ - @ instruction: 0xeeb0e916 │ │ │ │ + @ instruction: 0xeeb0e926 │ │ │ │ vnmul.f64 d7, d8, d0 │ │ │ │ vldr d8, [r7, #28] │ │ │ │ vldr d9, [r7, #16] │ │ │ │ @ instruction: 0xf7e50b0c │ │ │ │ - mrc 15, 5, lr, cr0, cr8, {5} │ │ │ │ + mrc 15, 5, lr, cr0, cr0, {6} │ │ │ │ vnmul.f64 d7, d9, d0 │ │ │ │ vadd.f64 d7, d8, d7 │ │ │ │ svcvs 0x00bb7b07 │ │ │ │ - blvc 1588c4 <__bss_end__@@Base+0xb1c8c> │ │ │ │ - blhi 58918 │ │ │ │ - bleq 35891c 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<__bss_end__@@Base+0x931da8> │ │ │ │ + blvc 1d8b6c <__bss_end__@@Base+0x131fcc> │ │ │ │ + blvc 3588f0 <__bss_end__@@Base+0x2b1d50> │ │ │ │ + blvc 158934 <__bss_end__@@Base+0xb1d94> │ │ │ │ + blvs 8d8958 <__bss_end__@@Base+0x831db8> │ │ │ │ + blvc 1d8b7c <__bss_end__@@Base+0x131fdc> │ │ │ │ + blvc 2d8900 <__bss_end__@@Base+0x231d60> │ │ │ │ + blhi 258944 <__bss_end__@@Base+0x1b1da4> │ │ │ │ + bleq 358948 <__bss_end__@@Base+0x2b1da8> │ │ │ │ + svc 0x006ef7e5 │ │ │ │ + blvc 1058db4 <__bss_end__@@Base+0xfb2214> │ │ │ │ + blhi 218b98 <__bss_end__@@Base+0x171ff8> │ │ │ │ + bleq 2d8958 <__bss_end__@@Base+0x231db8> │ │ │ │ + svc 0x0066f7e5 │ │ │ │ + blvc 1058dc4 <__bss_end__@@Base+0xfb2224> │ │ │ │ + blvc 218ba8 <__bss_end__@@Base+0x172008> │ │ │ │ stc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ vldr d7, [r7] │ │ │ │ vldr d8, [r7, #32] │ │ │ │ @ instruction: 0xf7e50b0c │ │ │ │ - cdp 15, 11, cr14, cr0, cr2, {2} │ │ │ │ + mrc 15, 5, lr, cr0, cr10, {2} │ │ │ │ vnmul.f64 d7, d8, d0 │ │ │ │ vldr d8, [r7, #28] │ │ │ │ @ instruction: 0xf7e60b0a │ │ │ │ - cdp 8, 11, cr14, cr0, cr14, {4} │ │ │ │ + mrc 8, 5, lr, cr0, cr14, {4} │ │ │ │ vnmul.f64 d7, d8, d0 │ │ │ │ ldmvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 589bc │ │ │ │ - blhi 258a10 <__bss_end__@@Base+0x1b1dd8> │ │ │ │ - bleq 358a14 <__bss_end__@@Base+0x2b1ddc> │ │ │ │ - stm r0, {r1, r2, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blvc 1058e80 <__bss_end__@@Base+0xfb2248> │ │ │ │ - blvc 218c64 <__bss_end__@@Base+0x17202c> │ │ │ │ + blvc 58944 │ │ │ │ + blhi 258998 <__bss_end__@@Base+0x1b1df8> │ │ │ │ + bleq 35899c <__bss_end__@@Base+0x2b1dfc> │ │ │ │ + ldm r0, {r1, r2, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blvc 1058e08 <__bss_end__@@Base+0xfb2268> │ │ │ │ + blvc 218bec <__bss_end__@@Base+0x17204c> │ │ │ │ stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ svclt 0x00007b00 │ │ │ │ @ instruction: 0x46bd3738 │ │ │ │ - blhi d86c8 <__bss_end__@@Base+0x31a90> │ │ │ │ + blhi d8650 <__bss_end__@@Base+0x31ab0> │ │ │ │ svclt 0x0000bd80 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ subsge r9, r2, #3648 @ 0xe40 │ │ │ │ svccc 0x0091df46 │ │ │ │ ldrlt fp, [r0, #132]! @ 0x84 │ │ │ │ svcge 0x000ab096 │ │ │ │ strbeq pc, [r0], #-263 @ 0xfffffef9 @ │ │ │ │ andeq lr, pc, r4, lsl #17 │ │ │ │ - blpl 1058eb8 <__bss_end__@@Base+0xfb2280> │ │ │ │ - blvs 1098ebc <__bss_end__@@Base+0xff2284> │ │ │ │ - blvc 10d8ec0 <__bss_end__@@Base+0x1032288> │ │ │ │ - blpl 58a20 │ │ │ │ - blvs d8a24 <__bss_end__@@Base+0x31dec> │ │ │ │ - blvc 158a28 <__bss_end__@@Base+0xb1df0> │ │ │ │ + blpl 1058e40 <__bss_end__@@Base+0xfb22a0> │ │ │ │ + blvs 1098e44 <__bss_end__@@Base+0xff22a4> │ │ │ │ + blvc 10d8e48 <__bss_end__@@Base+0x10322a8> │ │ │ │ + blpl 589a8 │ │ │ │ + blvs d89ac <__bss_end__@@Base+0x31e0c> │ │ │ │ + blvc 1589b0 <__bss_end__@@Base+0xb1e10> │ │ │ │ andseq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ msreq CPSR_, r7, lsl #2 │ │ │ │ msreq CPSR_f, #-1073741823 @ 0xc0000001 │ │ │ │ - blpl 58a78 │ │ │ │ - blvs d8a7c <__bss_end__@@Base+0x31e44> │ │ │ │ - blvc 158a80 <__bss_end__@@Base+0xb1e48> │ │ │ │ + blpl 58a00 │ │ │ │ + blvs d8a04 <__bss_end__@@Base+0x31e64> │ │ │ │ + blvc 158a08 <__bss_end__@@Base+0xb1e68> │ │ │ │ mrc 6, 5, r4, cr0, cr8, {0} │ │ │ │ vmov.f64 d0, d5 │ │ │ │ vmov.f64 d1, d6 │ │ │ │ @ instruction: 0xf7ff2b47 │ │ │ │ ldc 15, cr15, [r7, #444] @ 0x1bc │ │ │ │ vldr d7, [r7, #40] @ 0x28 │ │ │ │ vldr d6, [r7, #32] │ │ │ │ svcvs 0x003b5b06 │ │ │ │ strbtmi r9, [sp], -r8, lsl #6 │ │ │ │ ldrbeq pc, [r0], #-263 @ 0xfffffef9 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 1c841 │ │ │ │ + strgt ip, [pc, #-3087] @ 1c7c9 │ │ │ │ muleq pc, r4, r8 @ │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ movteq pc, #263 @ 0x107 @ │ │ │ │ vmov.f64 d12, #15 @ 0x40780000 3.875 │ │ │ │ vmov.f64 d2, d5 │ │ │ │ vmov.f64 d1, d6 │ │ │ │ @ instruction: 0xf7fe0b47 │ │ │ │ @@ -26527,45 +26522,45 @@ │ │ │ │ stc 4, cr0, [r4, #224] @ 0xe0 │ │ │ │ @ instruction: 0xf1072b00 │ │ │ │ stc 4, cr0, [r4, #-224] @ 0xffffff20 │ │ │ │ @ instruction: 0xf5073b02 │ │ │ │ @ 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cr14, [r7, #536] @ 0x218 │ │ │ │ + stc 14, cr14, [r7, #632] @ 0x278 │ │ │ │ vldr d0, [r7, #360] @ 0x168 │ │ │ │ @ instruction: 0xf7e50b5c │ │ │ │ - vstr , [r7, #336] @ 0x150 │ │ │ │ + vstr , [r7, #400] @ 0x190 │ │ │ │ vldr d0, [r7, #352] @ 0x160 │ │ │ │ @ instruction: 0xf7e50b66 │ │ │ │ - stc 14, cr14, [r7, #488] @ 0x1e8 │ │ │ │ + stc 14, cr14, [r7, #584] @ 0x248 │ │ │ │ vldr d0, [r7, #344] @ 0x158 │ │ │ │ @ instruction: 0xf7e50b66 │ │ │ │ - vstr , [r7, #288] @ 0x120 │ │ │ │ + vstr , [r7, #352] @ 0x160 │ │ │ │ @ instruction: 0xf1070b54 │ │ │ │ ldc 3, cr0, [r3, #288] @ 0x120 │ │ │ │ vldr d6, [r7] │ │ │ │ @ instruction: 0xee267b54 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ @ instruction: 0xf1076b06 │ │ │ │ @@ -26573,23 +26568,23 @@ │ │ │ │ vldr d5, [r7] │ │ │ │ @ instruction: 0xee257b54 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d5, d5, d0 │ │ │ │ @ instruction: 0xee867b47 │ │ │ │ vmov.f64 d5, #7 @ 0x40380000 2.875 │ │ │ │ @ instruction: 0xf7e50b45 │ │ │ │ - cdp 13, 11, cr14, cr0, cr14, {7} │ │ │ │ + cdp 14, 11, cr14, cr0, cr4, {0} │ │ │ │ vrintr.f64 d7, d0 │ │ │ │ vmul.f64 d6, d7, d0 │ │ │ │ @ instruction: 0xf1076b06 │ │ │ │ ldc 3, cr0, [r3, #288] @ 0x120 │ │ │ │ vmul.f64 d7, d6, d0 │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ @ instruction: 0xf7e50b47 │ │ │ │ - stc 12, cr14, [r7, #936] @ 0x3a8 │ │ │ │ + stc 12, cr14, [r7, #1016] @ 0x3f8 │ │ │ │ vldr d0, [r7, #328] @ 0x148 │ │ │ │ @ instruction: 0xeeb77b54 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ vldr d5, [r7, #24] │ │ │ │ @ instruction: 0xee856b52 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ @ instruction: 0xeeb77b50 │ │ │ │ @@ -26624,25 +26619,25 @@ │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ vmov.f64 d6, #118 @ 0x3fb00000 1.375 │ │ │ │ vldr d5, [r7] │ │ │ │ vsub.f64 d7, d5, d6 │ │ │ │ @ instruction: 0xee867b47 │ │ │ │ vmov.f64 d5, #7 @ 0x40380000 2.875 │ │ │ │ @ instruction: 0xf7e50b45 │ │ │ │ - cdp 13, 11, cr14, cr0, cr8, {4} │ │ │ │ + mrc 13, 5, lr, cr0, cr14, {4} │ │ │ │ vrintr.f64 d7, d0 │ │ │ │ vmul.f64 d6, d7, d0 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #272] @ 0x110 │ │ │ │ vldr d6, [r7, #296] @ 0x128 │ │ │ │ @ instruction: 0xee267b5a │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ vldr d1, [r7, #284] @ 0x11c │ │ │ │ @ instruction: 0xf7e50b48 │ │ │ │ - stc 14, cr14, [r7, #808] @ 0x328 │ │ │ │ + stc 14, cr14, [r7, #872] @ 0x368 │ │ │ │ vldr d0, [r7, #264] @ 0x108 │ │ │ │ vnmul.f64 d7, d7, d6 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vrintx.f64 d7, d0 │ │ │ │ vldr d6, [r7] │ │ │ │ vsub.f64 d7, d6, d0 │ │ │ │ vrintx.f64 d6, d7 │ │ │ │ @@ -26796,67 +26791,67 @@ │ │ │ │ @ instruction: 0xf1070378 │ │ │ │ ldc 2, cr0, [r2, #-480] @ 0xfffffe20 │ │ │ │ vadd.f64 d6, d6, d2 │ │ │ │ vstr d7, [r3, #-28] @ 0xffffffe4 │ │ │ │ @ instruction: 0xf5077b02 │ │ │ │ @ instruction: 0xf5a373bc │ │ │ │ ldmdavs fp, {r1, r2, r5, r7, r8, r9, ip, sp, lr} │ │ │ │ - blvs 58f38 │ │ │ │ - blvc ed8f4c <__bss_end__@@Base+0xe32314> │ │ │ │ - blvs 21918c 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- blvc 2191fc <__bss_end__@@Base+0x1725c4> │ │ │ │ - blvc d8d34 <__bss_end__@@Base+0x320fc> │ │ │ │ + blvs d8cec <__bss_end__@@Base+0x3214c> │ │ │ │ + blvc 1158f04 <__bss_end__@@Base+0x10b2364> │ │ │ │ + blvc 219184 <__bss_end__@@Base+0x1725e4> │ │ │ │ + blvc d8cbc <__bss_end__@@Base+0x3211c> │ │ │ │ @ instruction: 0x73bcf507 │ │ │ │ @ instruction: 0x73a6f5a3 │ │ │ │ tstcc r8, #1769472 @ 0x1b0000 │ │ │ │ - blvs 58f84 │ │ │ │ - blvc 958f98 <__bss_end__@@Base+0x8b2360> │ │ │ │ - blvc 2191d8 <__bss_end__@@Base+0x1725a0> │ │ │ │ + blvs 58f0c │ │ │ │ + blvc 958f20 <__bss_end__@@Base+0x8b2380> │ │ │ │ + blvc 219160 <__bss_end__@@Base+0x1725c0> │ │ │ │ msreq SPSR_f, #-1073741823 @ 0xc0000001 │ │ │ │ rsbseq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ - blvs 58f94 │ │ │ │ - blvc 2191e8 <__bss_end__@@Base+0x1725b0> │ │ │ │ - blvc 58f60 │ │ │ │ + blvs 58f1c │ │ │ │ + blvc 219170 <__bss_end__@@Base+0x1725d0> │ │ │ │ + blvc 58ee8 │ │ │ │ @ instruction: 0x73bcf507 │ │ │ │ @ instruction: 0x73a6f5a3 │ │ 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blvs 12592d8 <__bss_end__@@Base+0x11b2738> │ │ │ │ + blvc 16592dc <__bss_end__@@Base+0x15b273c> │ │ │ │ + blvc 21951c <__bss_end__@@Base+0x17297c> │ │ │ │ + blne 16d92e4 <__bss_end__@@Base+0x1632744> │ │ │ │ + bleq 121974c <__bss_end__@@Base+0x1172bac> │ │ │ │ + bl fe1dbc24 <__bss_end__@@Base+0xfe135084> │ │ │ │ + blhi 1059754 <__bss_end__@@Base+0xfb2bb4> │ │ │ │ msreq SPSR_f, #-1073741823 @ 0xc0000001 │ │ │ │ @ instruction: 0xf107461a │ │ │ │ ldc 3, cr0, [r2, #-352] @ 0xfffffea0 │ │ │ │ vldr d1, [r3, #8] │ │ │ │ @ instruction: 0xf7e50b00 │ │ │ │ - vmov.f64 d14, d26 │ │ │ │ + vmov.u16 lr, d0[3] │ │ │ │ vsub.f64 d7, d8, d0 │ │ │ │ @ instruction: 0xf8d77b07 │ │ │ │ stc 1, cr3, [r3, #656] @ 0x290 │ │ │ │ svclt 0x00007b00 │ │ │ │ ldrvc pc, [lr, r7, lsl #10]! │ │ │ │ ldc 6, cr4, [sp], #756 @ 0x2f4 │ │ │ │ vldrlt d8, [r0, #8] │ │ │ │ @@ -27088,58 +27083,58 @@ │ │ │ │ tstple sl, r0, lsl sl @ p-variant is OBSOLETE │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ subsvs r2, sl, r0, lsl #4 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ movwcs r6, #154 @ 0x9a │ │ │ │ ldmdavs fp!, {r2, r5, r7, sp, lr, pc}^ │ │ │ │ - blvc 1593c8 <__bss_end__@@Base+0xb2790> │ │ │ │ - bleq 1219840 <__bss_end__@@Base+0x1172c08> │ │ │ │ - ldmib r2!, {r0, r2, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blvc 1059848 <__bss_end__@@Base+0xfb2c10> │ │ │ │ - blvc ff219980 <__bss_end__@@Base+0xff172d48> │ │ │ │ - bcs fe4595ec <__bss_end__@@Base+0xfe3b29b4> │ │ │ │ + blvc 159350 <__bss_end__@@Base+0xb27b0> │ │ │ │ + bleq 12197c8 <__bss_end__@@Base+0x1172c28> │ │ │ │ + stmib r8, {r0, r2, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blvc 10597d0 <__bss_end__@@Base+0xfb2c30> │ │ │ │ + blvc ff219908 <__bss_end__@@Base+0xff172d68> │ │ │ │ + bcs fe459574 <__bss_end__@@Base+0xfe3b29d4> │ │ │ │ andsvs r6, sl, fp, ror r8 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ movweq pc, #12291 @ 0x3003 @ │ │ │ │ tstle r0, r0, lsl #22 │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ tstppl pc, #72, 4 @ p-variant is OBSOLETE @ 0x80000004 │ │ │ │ mvnne pc, #1342177292 @ 0x5000000c │ │ │ │ movwne pc, #11139 @ 0x2b83 @ │ │ │ │ @ instruction: 0x17d31159 │ │ │ │ cmncs r4, fp, asr #21 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ - blcs 2490c │ │ │ │ + blcs 24894 │ │ │ │ ldmdavs fp!, {r0, r4, r8, ip, lr, pc}^ │ │ │ │ vtst.8 d22, d8, d10 │ │ │ │ vorr.i32 d21, #24320 @ 0x00005f00 │ │ │ │ - blx fe0e2d7e <__bss_end__@@Base+0xfe03c146> │ │ │ │ + blx fe0e2d06 <__bss_end__@@Base+0xfe03c166> │ │ │ │ bicsne r1, r9, r2, lsl #6 │ │ │ │ - bne ff2e3d24 <__bss_end__@@Base+0xff23d0ec> │ │ │ │ + bne ff2e3cac <__bss_end__@@Base+0xff23d10c> │ │ │ │ bicvc pc, r8, pc, asr #8 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ - blcs 24930 │ │ │ │ + blcs 248b8 │ │ │ │ movwcs sp, #4353 @ 0x1101 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r7, sl, sp, lr}^ │ │ │ │ - blvs 15943c <__bss_end__@@Base+0xb2804> │ │ │ │ + blvs 1593c4 <__bss_end__@@Base+0xb2824> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ - bcc fe459614 <__bss_end__@@Base+0xfe3b29dc> │ │ │ │ - blvc ffa198dc <__bss_end__@@Base+0xff972ca4> │ │ │ │ - blvs 12196d8 <__bss_end__@@Base+0x1172aa0> │ │ │ │ + bcc fe45959c <__bss_end__@@Base+0xfe3b29fc> │ │ │ │ + blvc ffa19864 <__bss_end__@@Base+0xff972cc4> │ │ │ │ + blvs 1219660 <__bss_end__@@Base+0x1172ac0> │ │ │ │ mcr 12, 0, r6, cr7, cr11, {5} │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ - vldr d7, [pc, #924] @ 1e1a8 │ │ │ │ + vldr d7, [pc, #924] @ 1e130 │ │ │ │ vmov.s16 r5, d7[2] │ │ │ │ vmul.f64 d7, d6, d5 │ │ │ │ vmov.f64 d7, #103 @ 0x3f380000 0.7187500 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ vmov.f64 d7, #6 @ 0x40300000 2.750 │ │ │ │ @ instruction: 0xf7e50b47 │ │ │ │ - @ instruction: 0xeeb0e962 │ │ │ │ + @ instruction: 0xeeb0e978 │ │ │ │ vrintx.f64 d7, d0 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ vmov.f64 d23, #214 @ 0xbeb00000 -0.3437500 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ ldrtvs r3, [fp], #-2704 @ 0xfffff570 │ │ │ │ rscsvs r2, fp, r0, lsl #6 │ │ │ │ teqvs fp, pc, lsl r3 │ │ │ │ @@ -27164,19 +27159,19 @@ │ │ │ │ addsmi r6, sl, #64256 @ 0xfb00 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r3, sl, fp, ip, lr, pc}^ │ │ │ │ subsvs r6, sl, sl, ror ip │ │ │ │ addseq r6, fp, fp, ror ip │ │ │ │ ldrtmi r3, [fp], #-848 @ 0xfffffcb0 │ │ │ │ mcrrcs 8, 5, pc, r4, cr3 @ │ │ │ │ ldcvs 12, cr6, [fp], #-996 @ 0xfffffc1c │ │ │ │ - bne ff4a49d8 <__bss_end__@@Base+0xff3fdda0> │ │ │ │ + bne ff4a4960 <__bss_end__@@Base+0xff3fddc0> │ │ │ │ addsvs r6, sl, fp, ror r8 │ │ │ │ ldclvs 0, cr14, [fp], #-20 @ 0xffffffec │ │ │ │ ldrbtvs r3, [fp], #-769 @ 0xfffffcff │ │ │ │ - blcs 3390a8 <__bss_end__@@Base+0x292470> │ │ │ │ + blcs 339030 <__bss_end__@@Base+0x292490> │ │ │ │ movwcs sp, #7644 @ 0x1ddc │ │ │ │ smmlacc r0, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbsmi sp, r6, r0 │ │ │ │ addlt fp, ip, r0, lsl #11 │ │ │ │ @@ -27185,127 +27180,127 @@ │ │ │ │ vmov.f64 d6, d1 │ │ │ │ rsbsvs r7, r8, r2, asr #22 │ │ │ │ stc 0, cr6, [r7, #228] @ 0xe4 │ │ │ │ vstr d5, [r7, #8] │ │ │ │ vstr d6, [r7, #16] │ │ │ │ movwcs r7, #6918 @ 0x1b06 │ │ │ │ ldc 2, cr6, [r7, #1004] @ 0x3ec │ │ │ │ - vldr d7, [pc, #16] @ 1df10 │ │ │ │ + vldr d7, [pc, #16] @ 1de98 │ │ │ │ vmov.32 d7[1], r6 │ │ │ │ vmov.f64 d7, #6 @ 0x40300000 2.750 │ │ │ │ @ instruction: 0xf7e50b47 │ │ │ │ - vstr s28, [r7, #864] @ 0x360 │ │ │ │ + vstr s28, [r7, #928] @ 0x3a0 │ │ │ │ ldmdavs fp!, {r3, r8, r9, fp}^ │ │ │ │ vstrle d2, [lr, #-64] @ 0xffffffc0 │ │ │ │ - blvc 259578 <__bss_end__@@Base+0x1b2940> │ │ │ │ - blvc ff2199e0 <__bss_end__@@Base+0xff172da8> │ │ │ │ - blvs 59a00 │ │ │ │ - blvc 1219800 <__bss_end__@@Base+0x1172bc8> │ │ │ │ - blvs 5d95a8 <__bss_end__@@Base+0x532970> │ │ │ │ - blvc ff1d9a00 <__bss_end__@@Base+0xff132dc8> │ │ │ │ - blx 459af8 <__bss_end__@@Base+0x3b2ec0> │ │ │ │ + blvc 259500 <__bss_end__@@Base+0x1b2960> │ │ │ │ + blvc ff219968 <__bss_end__@@Base+0xff172dc8> │ │ │ │ + blvs 59988 │ │ │ │ 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│ strbeq pc, [r0], #263 @ 0x107 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 1d6d9 │ │ │ │ + strgt ip, [pc, #-3087] @ 1d661 │ │ │ │ muleq r3, r4, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ movseq pc, #-1073741823 @ 0xc0000001 │ │ │ │ vmov.f64 d12, #15 @ 0x40780000 3.875 │ │ │ │ vmov.f64 d0, d2 │ │ │ │ vmov.f64 d1, d6 │ │ │ │ @ instruction: 0xf7fe2b47 │ │ │ │ @@ -27451,20 +27446,20 @@ │ │ │ │ vldr d10, [r7, #24] │ │ │ │ vldr d9, [r7, #32] │ │ │ │ @ instruction: 0xf8d78b0a │ │ │ │ tstls ip, #96, 2 │ │ │ │ @ instruction: 0xf1074668 │ │ │ │ rsbscs r0, r0, #240, 6 @ 0xc0000003 │ │ │ │ @ instruction: 0xf7e44619 │ │ │ │ - @ instruction: 0xf107ef84 │ │ │ │ - blgt 3df2ac <__bss_end__@@Base+0x338674> │ │ │ │ - bleq 12d9df0 <__bss_end__@@Base+0x12331b8> │ │ │ │ - blne 1299df4 <__bss_end__@@Base+0x11f31bc> │ │ │ │ - blcs 1259df8 <__bss_end__@@Base+0x11b31c0> │ │ │ │ - blx 1d5c332 <__bss_end__@@Base+0x1cb56fa> │ │ │ │ + @ instruction: 0xf107ef9c │ │ │ │ + blgt 3df234 <__bss_end__@@Base+0x338694> │ │ │ │ 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#28] │ │ │ │ vmov.f64 d4, #116 @ 0x3fa00000 1.250 │ │ │ │ vdiv.f64 d3, d3, d0 │ │ │ │ vmul.f64 d7, d5, d4 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ fldmiaxvs fp!, {d23-d57} @ Deprecated │ │ │ │ - blvc 159a84 <__bss_end__@@Base+0xb2e4c> │ │ │ │ + blvc 159a0c <__bss_end__@@Base+0xb2e6c> │ │ │ │ ldc 12, cr6, [r3, #1004] @ 0x3ec │ │ │ │ @ instruction: 0x6c3a6b02 │ │ │ │ sbcseq r6, fp, fp, lsr fp │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ ldmibvs fp!, {r8, r9, fp, ip, lr} │ │ │ │ - bvs 1ef90f8 <__bss_end__@@Base+0x1e524c0> │ │ │ │ + bvs 1ef9080 <__bss_end__@@Base+0x1e524e0> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blmi 59ae4 │ │ │ │ - blvs 1ef9684 <__bss_end__@@Base+0x1e52a4c> │ │ │ │ + blmi 59a6c │ │ │ │ + blvs 1ef960c <__bss_end__@@Base+0x1e52a6c> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blvc 59af0 │ │ │ │ - blmi 219d38 <__bss_end__@@Base+0x173100> │ │ │ │ - blvs 16b8b98 <__bss_end__@@Base+0x1611f60> │ │ │ │ + blvc 59a78 │ │ │ │ + blmi 219cc0 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cr6, [r3, #1004] @ 0x3ec │ │ │ │ vldmiavs fp!, {d23-d22} │ │ │ │ - blpl 159c70 <__bss_end__@@Base+0xb3038> │ │ │ │ - blvs 2d9c84 <__bss_end__@@Base+0x23304c> │ │ │ │ - blvc 1da040 <__bss_end__@@Base+0x133408> │ │ │ │ + blpl 159bf8 <__bss_end__@@Base+0xb3058> │ │ │ │ + blvs 2d9c0c <__bss_end__@@Base+0x23306c> │ │ │ │ + blvc 1d9fc8 <__bss_end__@@Base+0x133428> │ │ │ │ stc 12, cr6, [r3, #1004] @ 0x3ec │ │ │ │ svclt 0x00007b04 │ │ │ │ @ instruction: 0x46bd3738 │ │ │ │ @ instruction: 0x4080e8bd │ │ │ │ ldrbmi fp, [r0, -r2]! │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ subsge r9, r2, #3648 @ 0xe40 │ │ │ │ @@ -27664,152 +27659,152 @@ │ │ │ │ stc 1, cr6, [r7, #228] @ 0xe4 │ │ │ │ rsbsvs r0, sl, r2, lsl #22 │ │ │ │ movwcc r6, #6267 @ 0x187b │ │ │ │ andcc r6, r2, #7995392 @ 0x7a0000 │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldrmi r0, [r3], #-4058 @ 0xfffff026 │ │ │ │ mvnsvs r1, #91 @ 0x5b │ │ │ │ - blvc d9cd8 <__bss_end__@@Base+0x330a0> │ │ │ │ - blvc ff21a140 <__bss_end__@@Base+0xff173508> │ │ │ │ - blvs 5a160 │ │ │ │ - blvc 11da158 <__bss_end__@@Base+0x1133520> │ │ │ │ - blx 45a250 <__bss_end__@@Base+0x3b3618> │ │ │ │ + blvc d9c60 <__bss_end__@@Base+0x330c0> │ │ │ │ + blvc ff21a0c8 <__bss_end__@@Base+0xff173528> │ │ │ │ + blvs 5a0e8 │ │ │ │ + blvc 11da0e0 <__bss_end__@@Base+0x1133540> │ │ │ │ + blx 45a1d8 <__bss_end__@@Base+0x3b3638> │ │ │ │ @ instruction: 0xf8dfd107 │ │ │ │ ldrbtmi r3, [fp], #-1620 @ 0xfffff9ac │ │ │ │ @ instruction: 0xf7e44618 │ │ │ │ - movwcs lr, #3816 @ 0xee8 │ │ │ │ - blvs fff17300 <__bss_end__@@Base+0xffe706c8> │ │ │ │ + movwcs lr, #3832 @ 0xef8 │ │ │ │ + blvs fff17288 <__bss_end__@@Base+0xffe706e8> │ │ │ │ sbcseq r3, fp, r1, lsl #6 │ │ │ │ @ instruction: 0xf7e44618 │ │ │ │ - @ instruction: 0x4603ee7e │ │ │ │ - blvs feef759c <__bss_end__@@Base+0xfee50964> │ │ │ │ + @ instruction: 0x4603ee96 │ │ │ │ + blvs feef7524 <__bss_end__@@Base+0xfee50984> │ │ │ │ tstle r4, r0, lsl #22 │ │ │ │ @ instruction: 0xf7f92012 │ │ │ │ movwcs pc, #2829 @ 0xb0d @ │ │ │ │ - blvs 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{r8, r9, sp}^ │ │ │ │ movwcs r2, #778 @ 0x30a │ │ │ │ ands r6, r3, fp, lsr r4 │ │ │ │ mcr 12, 0, r6, cr7, cr11, {1} │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ @ instruction: 0x6c3b7be7 │ │ │ │ - blvs 1e9ea8c <__bss_end__@@Base+0x1df7e54> │ │ │ │ + blvs 1e9ea14 <__bss_end__@@Base+0x1df7e74> │ │ │ │ mrc 8, 5, r1, cr0, cr4, {6} │ │ │ │ @ instruction: 0xf7e40b47 │ │ │ │ - mrc 12, 5, lr, cr0, cr14, {7} │ │ │ │ + mrc 13, 5, lr, cr0, cr4, {0} │ │ │ │ vstr d7, [r4, #256] @ 0x100 │ │ │ │ @ instruction: 0x6c3b7b00 │ │ │ │ ldrtvs r3, [fp], #-769 @ 0xfffffcff │ │ │ │ subseq r6, fp, fp, ror r8 │ │ │ │ ldcvs 3, cr3, [sl], #-4 │ │ │ │ stclle 2, cr4, [r5, #616]! @ 0x268 │ │ │ │ ldrbtvs r2, [fp], #770 @ 0x302 │ │ │ │ ldrtvs r2, [fp], #-770 @ 0xfffffcfe │ │ │ │ ldclvs 0, cr14, [fp], #576 @ 0x240 │ │ │ │ ldrbtvs r3, [fp], #769 @ 0x301 │ │ │ │ subseq r6, fp, fp, lsr ip │ │ │ │ vmla.f64 d3, d7, d1 │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ @ instruction: 0x6c3b5be7 │ │ │ │ - bcc fe459f84 <__bss_end__@@Base+0xfe3b334c> │ │ │ │ - blvs ffa1a24c <__bss_end__@@Base+0xff973614> │ │ │ │ + bcc fe459f0c <__bss_end__@@Base+0xfe3b336c> │ │ │ │ + blvs ffa1a1d4 <__bss_end__@@Base+0xff973634> │ │ │ │ ldrsheq r6, [fp], #203 @ 0xcb │ │ │ │ ldrmi r6, [r3], #-3002 @ 0xfffff446 │ │ │ │ - blvc 1da18c <__bss_end__@@Base+0x133554> │ │ │ │ - blvc 59d88 │ │ │ │ - blcc 7986c <__bss_start@@Base+0x1e7cc> │ │ │ │ - bcc fe459fa0 <__bss_end__@@Base+0xfe3b3368> │ │ │ │ - blpl ffa1a268 <__bss_end__@@Base+0xff973630> │ │ │ │ + blvc 1da114 <__bss_end__@@Base+0x133574> │ │ │ │ + blvc 59d10 │ │ │ │ + blcc 797f4 <__bss_start@@Base+0x1e7ec> │ │ │ │ + bcc fe459f28 <__bss_end__@@Base+0xfe3b3388> │ │ │ │ + blpl ffa1a1f0 <__bss_end__@@Base+0xff973650> │ │ │ │ mcr 12, 0, r6, cr7, cr11, {1} │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ fldmiaxvs fp!, {d22-d136} @ Deprecated │ │ │ │ - blvs e9eb04 <__bss_end__@@Base+0xdf7ecc> │ │ │ │ + blvs e9ea8c <__bss_end__@@Base+0xdf7eec> │ │ │ │ mcr 4, 4, r4, cr5, cr3, {0} │ │ │ │ vstr d7, [r3, #24] │ │ │ │ movwcs r7, #6912 @ 0x1b00 │ │ │ │ subs r6, r8, fp, ror r4 │ │ │ │ movwcc r6, #7419 @ 0x1cfb │ │ │ │ ldcvs 4, cr6, [fp], #-1004 @ 0xfffffc14 │ │ │ │ - blcc 5e920 <__bss_start@@Base+0x3880> │ │ │ │ - bcc fe459fd4 <__bss_end__@@Base+0xfe3b339c> │ │ │ │ - blvs ffa1a29c <__bss_end__@@Base+0xff973664> │ │ │ │ + blcc 5e8a8 <__bss_start@@Base+0x38a0> │ │ │ │ + bcc fe459f5c <__bss_end__@@Base+0xfe3b33bc> │ │ │ │ + blvs ffa1a224 <__bss_end__@@Base+0xff973684> │ │ │ │ ldclvs 12, cr6, [fp], #-232 @ 0xffffff18 │ │ │ │ sbcseq r4, fp, r3, lsl r4 │ │ │ │ ldrmi r6, [r3], #-2938 @ 0xfffff486 │ │ │ │ - blvc 59e18 │ │ │ │ - blpl 21a1e8 <__bss_end__@@Base+0x1735b0> │ │ │ │ + blvc 59da0 │ │ │ │ + blpl 21a170 <__bss_end__@@Base+0x1735d0> │ │ │ │ ldclvs 12, cr6, [fp], #-232 @ 0xffffff18 │ │ │ │ ldrsbeq r1, [fp], #163 @ 0xa3 │ │ │ │ ldrmi r6, [r3], #-2938 @ 0xfffff486 │ │ │ │ - blvs 59e2c │ │ │ │ + blvs 59db4 │ │ │ │ ldrsheq r6, [fp], #203 @ 0xcb │ │ │ │ ldrmi r6, [r3], #-3002 @ 0xfffff446 │ │ │ │ - blvc 1da200 <__bss_end__@@Base+0x1335c8> │ │ │ │ - blvc 59dfc │ │ │ │ + blvc 1da188 <__bss_end__@@Base+0x1335e8> │ │ │ │ + blvc 59d84 │ │ │ │ ldclvs 12, cr6, [fp], #-232 @ 0xffffff18 │ │ │ │ @ instruction: 0xf1031ad3 │ │ │ │ - blcc 733fc <__bss_start@@Base+0x1835c> │ │ │ │ - blvs 1e9eb6c <__bss_end__@@Base+0x1df7f34> │ │ │ │ + blcc 73384 <__bss_start@@Base+0x1837c> │ │ │ │ + blvs 1e9eaf4 <__bss_end__@@Base+0x1df7f54> │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ @ instruction: 0x6c3a6b00 │ │ │ │ ldrmi r6, [r3], #-3195 @ 0xfffff385 │ │ │ │ movwpl pc, #259 @ 0x103 @ │ │ │ │ sbcseq r3, fp, r1, lsl #22 │ │ │ │ ldrmi r6, [r3], #-2938 @ 0xfffff486 │ │ │ │ - blvc 59e68 │ │ │ │ - blvs 21a0b8 <__bss_end__@@Base+0x173480> │ │ │ │ + blvc 59df0 │ │ │ │ + blvs 21a040 <__bss_end__@@Base+0x1734a0> │ │ │ │ ldclvs 12, cr6, [fp], #-232 @ 0xffffff18 │ │ │ │ sbcseq r4, fp, r3, lsl r4 │ │ │ │ ldrmi r6, [r3], #-2938 @ 0xfffff486 │ │ │ │ - blvc 59e7c │ │ │ │ - blpl 21a24c <__bss_end__@@Base+0x173614> │ │ │ │ + blvc 59e04 │ │ │ │ + blpl 21a1d4 <__bss_end__@@Base+0x173634> │ │ │ │ ldclvs 12, cr6, [fp], #-232 @ 0xffffff18 │ │ │ │ ldrsbeq r1, [fp], #163 @ 0xa3 │ │ │ │ ldrmi r6, [r3], #-2938 @ 0xfffff486 │ │ │ │ - blvs 59e90 │ │ │ │ + blvs 59e18 │ │ │ │ ldrsheq r6, [fp], #203 @ 0xcb │ │ │ │ ldrmi r6, [r3], #-2874 @ 0xfffff4c6 │ │ │ │ - blvc 1da264 <__bss_end__@@Base+0x13362c> │ │ │ │ - blvc 59e60 │ │ │ │ + blvc 1da1ec <__bss_end__@@Base+0x13364c> │ │ │ │ + blvc 59de8 │ │ │ │ movwcc r6, #7291 @ 0x1c7b │ │ │ │ ldcvs 4, cr6, [fp], #-492 @ 0xfffffe14 │ │ │ │ @ instruction: 0x6c7a3b01 │ │ │ │ - blle fe86f2cc <__bss_end__@@Base+0xfe7c8694> │ │ │ │ + blle fe86f254 <__bss_end__@@Base+0xfe7c86b4> │ │ │ │ movwcc r6, #11515 @ 0x2cfb │ │ │ │ ldcvs 4, cr6, [fp], #-1004 @ 0xfffffc14 │ │ │ │ ldrtvs r3, [fp], #-769 @ 0xfffffcff │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, sl, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf77f429a │ │ │ │ cdp 15, 11, cr10, cr7, cr10, {3} │ │ │ │ vldr d6, [r7] │ │ │ │ vadd.f64 d7, d6, d2 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ vmov.f64 d7, #114 @ 0x3f900000 1.125 │ │ │ │ vadd.f64 d5, d7, d0 │ │ │ │ vmul.f64 d7, d6, d5 │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ @ instruction: 0xf7e40b47 │ │ │ │ - stc 12, cr14, [r7, #272] @ 0x110 │ │ │ │ + stc 12, cr14, [r7, #360] @ 0x168 │ │ │ │ @ instruction: 0xf04f0b08 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ @ instruction: 0xf6c30300 │ │ │ │ stmib r7, {r4, r5, r6, r7, r8, r9, ip, sp, lr}^ │ │ │ │ ldmdbvs r9!, {r1, r3, r4, r8, r9, sp}^ │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ @@ -27831,117 +27826,117 @@ │ │ │ │ movwcs lr, #35287 @ 0x89d7 │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ ldrbtvs r2, [fp], #769 @ 0x301 │ │ │ │ ldrtvs r2, [fp], #-770 @ 0xfffffcfe │ │ │ │ ldclvs 0, cr14, [sl], #308 @ 0x134 │ │ │ │ ldrmi r6, [r3], #-3131 @ 0xfffff3c5 │ │ │ │ ldclvs 4, cr6, [fp], #1004 @ 0x3ec │ │ │ │ - blvs fee9ec84 <__bss_end__@@Base+0xfedf804c> │ │ │ │ + blvs fee9ec0c <__bss_end__@@Base+0xfedf806c> │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ vldr d6, [r7] │ │ │ │ vmul.f64 d7, d6, d2 │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vmov.32 d6[1], r7 │ │ │ │ fldmiaxvs fp!, {d22-d24} @ Deprecated │ │ │ │ - blvs e9eca0 <__bss_end__@@Base+0xdf8068> │ │ │ │ + blvs e9ec28 <__bss_end__@@Base+0xdf8088> │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ vldr d5, [r7] │ │ │ │ vmov.32 d5[1], r7 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vstr d7, [r7, #284] @ 0x11c │ │ │ │ vldmiavs fp!, {d23-d25} │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r6, r7}^ │ │ │ │ ldmib r7, {r0, r4, r6, r7, fp, ip}^ │ │ │ │ stmib r1, {r1, r2, r8, r9, sp}^ │ │ │ │ ldcvs 3, cr2, [fp], #-0 │ │ │ │ - bcc fe45a17c <__bss_end__@@Base+0xfe3b3544> │ │ │ │ - blvs ffa1a444 <__bss_end__@@Base+0xff97380c> │ │ │ │ - blpl d9fc4 <__bss_end__@@Base+0x3338c> │ │ │ │ - blvc 1d9fc8 <__bss_end__@@Base+0x133390> │ │ │ │ - blvc 21a204 <__bss_end__@@Base+0x1735cc> │ │ │ │ - blpl 659fd0 <__bss_end__@@Base+0x5b3398> │ │ │ │ - blvc 121a24c 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cr4, [r3, #76] @ 0x4c │ │ │ │ @ instruction: 0x6c7a8b00 │ │ │ │ - bne ff4fa1cc <__bss_end__@@Base+0xff453594> │ │ │ │ + bne ff4fa154 <__bss_end__@@Base+0xff4535b4> │ │ │ │ ldcvs 12, cr1, [fp], #-360 @ 0xfffffe98 │ │ │ │ tstle r1, r1, lsl #22 │ │ │ │ and r2, r0, r2, lsl #6 │ │ │ │ - blx a7cf6 <__bss_end__@@Base+0x10be> │ │ │ │ + blx a7c7e <__bss_end__@@Base+0x10de> │ │ │ │ cdp 3, 0, cr15, cr7, cr3, {0} │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ @ instruction: 0x6c7a6be7 │ │ │ │ ldrmi r6, [r3], #-3131 @ 0xfffff3c5 │ │ │ │ - bcc fe45a920 <__bss_end__@@Base+0xfe3b3ce8> │ │ │ │ - blvc ffa1abe8 <__bss_end__@@Base+0xff973fb0> │ │ │ │ - blpl 21ab24 <__bss_end__@@Base+0x173eec> │ │ │ │ - bleq 119abd0 <__bss_end__@@Base+0x10f3f98> │ │ │ │ - stmda r8, {r2, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blvc 105abd8 <__bss_end__@@Base+0xfb3fa0> │ │ │ │ + bcc fe45a8a8 <__bss_end__@@Base+0xfe3b3d08> │ │ │ │ + blvc ffa1ab70 <__bss_end__@@Base+0xff973fd0> │ │ │ │ + blpl 21aaac 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0x461a105b │ │ │ │ ldrmi r6, [r3], #-3131 @ 0xfffff3c5 │ │ │ │ - bvs ffef7d58 <__bss_end__@@Base+0xffe51120> │ │ │ │ + bvs ffef7ce0 <__bss_end__@@Base+0xffe51140> │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r6, r7}^ │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ - bvs ffef9d78 <__bss_end__@@Base+0xffe53140> │ │ │ │ - blvs e9f4e8 <__bss_end__@@Base+0xdf88b0> │ │ │ │ + bvs ffef9d00 <__bss_end__@@Base+0xffe53160> │ │ │ │ + blvs e9f470 <__bss_end__@@Base+0xdf88d0> │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ - bvs ffefdd84 <__bss_end__@@Base+0xffe5714c> │ │ │ │ + bvs ffefdd0c <__bss_end__@@Base+0xffe5716c> │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r6, r7}^ │ │ │ │ mcr 4, 1, r4, cr6, cr3, {0} │ │ │ │ vstr d7, [r3, #28] │ │ │ │ - bvs ffefdd94 <__bss_end__@@Base+0xffe5715c> │ │ │ │ + bvs ffefdd1c <__bss_end__@@Base+0xffe5717c> │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r6, r7} │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ vmov.f64 d7, #16 @ 0x40800000 4.0 │ │ │ │ - bvs ffef9ec0 <__bss_end__@@Base+0xffe53288> │ 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[sp], #756 @ 0x2f4 │ │ │ │ vstrlt d8, [r0, #8] │ │ │ │ strlt fp, [r0, #130] @ 0x82 │ │ │ │ svcge 0x0002b090 │ │ │ │ @ instruction: 0x61b961f8 │ │ │ │ cmppeq r0, r7, lsl #2 @ p-variant is OBSOLETE │ │ │ │ andeq lr, ip, r1, lsl #17 │ │ │ │ - blpl 105accc <__bss_end__@@Base+0xfb4094> │ │ │ │ - blvs 109acd0 <__bss_end__@@Base+0xff4098> │ │ │ │ - blvc 10dacd4 <__bss_end__@@Base+0x103409c> │ │ │ │ - blpl 5a834 │ │ │ │ - blvs da838 <__bss_end__@@Base+0x33c00> │ │ │ │ - blvc 15a83c <__bss_end__@@Base+0xb3c04> │ │ │ │ + blpl 105ac54 <__bss_end__@@Base+0xfb40b4> │ │ │ │ + blvs 109ac58 <__bss_end__@@Base+0xff40b8> │ │ │ │ + blvc 10dac5c <__bss_end__@@Base+0x10340bc> │ │ │ │ + blpl 5a7bc │ │ │ │ + blvs da7c0 <__bss_end__@@Base+0x33c20> │ │ │ │ + blvc 15a7c4 <__bss_end__@@Base+0xb3c24> │ │ │ │ andcs r6, r1, #3063808 @ 0x2ec000 │ │ │ │ ldclvs 4, cr6, [r9], #616 @ 0x268 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #18881 @ 0x49c1 │ │ │ │ @ instruction: 0xf04f6cf9 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ @@ -28426,146 +28421,146 @@ │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ teqvs fp, #67108864 @ 0x4000000 │ │ │ │ movwcs lr, #211 @ 0xd3 │ │ │ │ sbc r6, r8, fp, ror r3 │ │ │ │ movwcc r6, #6971 @ 0x1b3b │ │ │ │ - blx b9f4e <__bss_end__@@Base+0x13316> │ │ │ │ + blx b9ed6 <__bss_end__@@Base+0x13336> │ │ │ │ svceq 0x00daf303 │ │ │ │ subsne r4, fp, r3, lsl r4 │ │ │ │ - blvs 1ef0ad8 <__bss_end__@@Base+0x1e49ea0> │ │ │ │ + blvs 1ef0a60 <__bss_end__@@Base+0x1e49ec0> │ │ │ │ rsbsvs r4, fp, #318767104 @ 0x13000000 │ │ │ │ ldc 12, cr6, [r3, #1004] @ 0x3ec │ │ │ │ @ instruction: 0x6c3a6b04 │ │ │ │ sbcseq r6, fp, fp, lsr fp │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ ldmibvs fp!, {r8, r9, fp, ip, lr} │ │ │ │ - bvs 1efa0f4 <__bss_end__@@Base+0x1e534bc> │ │ │ │ + bvs 1efa07c <__bss_end__@@Base+0x1e534dc> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blmi 5a8e0 │ │ │ │ - blvs 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[r3], #-219 @ 0xffffff25 │ │ │ │ - blvc 5a9b4 │ │ │ │ - blvc 21ac00 <__bss_end__@@Base+0x173fc8> │ │ │ │ - blvc 21ac48 <__bss_end__@@Base+0x174010> │ │ │ │ + blvc 5a93c │ │ │ │ + blvc 21ab88 <__bss_end__@@Base+0x173fe8> │ │ │ │ + blvc 21abd0 <__bss_end__@@Base+0x174030> │ │ │ │ stc 12, cr6, [r3, #1004] @ 0x3ec │ │ │ │ vldmiavs fp!, {d23} │ │ │ │ - blvs 5a9c8 │ │ │ │ - blvs efa468 <__bss_end__@@Base+0xe53830> │ │ │ │ + blvs 5a950 │ │ │ │ + blvs efa3f0 <__bss_end__@@Base+0xe53850> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blpl 5a9d4 │ │ │ │ - blvs fe6b9a78 <__bss_end__@@Base+0xfe612e40> │ │ │ │ + blpl 5a95c │ │ │ │ + blvs fe6b9a00 <__bss_end__@@Base+0xfe612e60> │ │ │ │ sbcseq r6, fp, fp, ror sl │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ @ instruction: 0x6c7a4b00 │ │ │ │ sbcseq r6, fp, fp, ror fp │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ vmul.f64 d7, d4, d0 │ │ │ │ ldmibvs fp!, {r0, r1, r2, r8, r9, fp, lr} │ │ │ │ - bvs 1efa314 <__bss_end__@@Base+0x1e536dc> │ │ │ │ + bvs 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#17 │ │ │ │ - blpl 105af70 <__bss_end__@@Base+0xfb4338> │ │ │ │ - blvs 109af74 <__bss_end__@@Base+0xff433c> │ │ │ │ - blvc 10daf78 <__bss_end__@@Base+0x1034340> │ │ │ │ - blpl 5aad8 │ │ │ │ - blvs daadc <__bss_end__@@Base+0x33ea4> │ │ │ │ - blvc 15aae0 <__bss_end__@@Base+0xb3ea8> │ │ │ │ + blpl 105aef8 <__bss_end__@@Base+0xfb4358> │ │ │ │ + blvs 109aefc <__bss_end__@@Base+0xff435c> │ │ │ │ + blvc 10daf00 <__bss_end__@@Base+0x1034360> │ │ │ │ + blpl 5aa60 │ │ │ │ + blvs daa64 <__bss_end__@@Base+0x33ec4> │ │ │ │ + blvc 15aa68 <__bss_end__@@Base+0xb3ec8> │ │ │ │ mrrcvs 10, 7, r6, fp, cr11 │ │ │ │ sbcseq r3, fp, r1, lsl #6 │ │ │ │ @ instruction: 0xf7e34618 │ │ │ │ - strmi lr, [r3], -sl, ror #30 │ │ │ │ + strmi lr, [r3], -r2, lsl #31 │ │ │ │ ldclvs 5, cr6, [fp, #-492]! @ 0xfffffe14 │ │ │ │ tstle r4, r0, lsl #22 │ │ │ │ @ instruction: 0xf7f8200f │ │ │ │ movwcs pc, #3065 @ 0xbf9 @ │ │ │ │ ldclvs 0, cr14, [r9, #-1000]! @ 0xfffffc18 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ @@ -28600,103 +28595,103 @@ │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ tstcs r6, #3260416 @ 0x31c000 │ │ │ │ @ instruction: 0xf04f6f39 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r1, {r8, r9}^ │ │ │ │ ldc 3, cr2, [r7, #8] │ │ │ │ - vldr d7, [pc, #8] @ 1f524 │ │ │ │ + vldr d7, [pc, #8] @ 1f4ac │ │ │ │ vmov.16 d7[3], r6 │ │ │ │ vmov.f64 d7, #6 @ 0x40300000 2.750 │ │ │ │ @ instruction: 0xf7e30b47 │ │ │ │ - vstr , [r7, #296] @ 0x128 │ │ │ │ + vstr , [r7, #360] @ 0x168 │ │ │ │ movwcs r0, #6930 @ 0x1b12 │ │ │ │ sbc r6, r6, fp, ror r6 │ │ │ │ movwcc r6, #7803 @ 0x1e7b │ │ │ │ - blx baf26 <__bss_end__@@Base+0x142ee> │ │ │ │ + blx baeae <__bss_end__@@Base+0x1430e> │ │ │ │ svceq 0x00daf303 │ │ │ │ subsne r4, fp, r3, lsl r4 │ │ │ │ ldrbtvs r3, [fp], #-769 @ 0xfffffcff │ │ │ │ subseq r6, fp, fp, ror lr │ │ │ │ vmla.f64 d3, d7, d1 │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ vldr d6, [r7, #924] @ 0x39c │ │ │ │ vmov.32 d6[1], r7 │ │ │ │ vaddvs.f64 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lr │ │ │ │ ldrmi r6, [r1], #-3449 @ 0xfffff287 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ mrcvs 0, 3, lr, cr11, cr12, {1} │ │ │ │ vaddvs.f64 d19, d10, d1 │ │ │ │ - blx adde2 <__bss_end__@@Base+0x71aa> │ │ │ │ - blcc 9c1ec <__bss_start@@Base+0x4114c> │ │ │ │ - bcc fe45ae00 <__bss_end__@@Base+0xfe3b41c8> │ │ │ │ - blpl ffa1b0c8 <__bss_end__@@Base+0xff974490> │ │ │ │ + blx add6a <__bss_end__@@Base+0x71ca> │ │ │ │ + blcc 9c174 <__bss_start@@Base+0x4116c> │ │ │ │ + bcc fe45ad88 <__bss_end__@@Base+0xfe3b41e8> │ │ │ │ + blpl ffa1b050 <__bss_end__@@Base+0xff9744b0> │ │ │ │ subseq r6, fp, fp, ror lr │ │ │ │ vaddvs.f64 d19, d10, d1 │ │ │ │ - bcc df73c <__bss_end__@@Base+0x38b04> │ │ │ │ + bcc df6c4 <__bss_end__@@Base+0x38b24> │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ - bcc fe45ae18 <__bss_end__@@Base+0xfe3b41e0> │ │ │ │ - blvs ffa1b0e0 <__bss_end__@@Base+0xff9744a8> │ │ │ │ - blvc 1db018 <__bss_end__@@Base+0x1343e0> │ │ │ │ - blvc 2dac24 <__bss_end__@@Base+0x233fec> │ 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-28704,183 +28699,183 @@ │ │ │ │ ldclvs 0, cr0, [sl, #-876]! @ 0xfffffc94 │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ vmul.f64 d7, d5, d0 │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmul.f64 d7, d5, d12 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ svcvs 0x003b7b07 │ │ │ │ - blvc dacc8 <__bss_end__@@Base+0x34090> │ │ │ │ + blvc dac50 <__bss_end__@@Base+0x340b0> │ │ │ │ movwcc r6, #7803 @ 0x1e7b │ │ │ │ - bvs 1ef90b0 <__bss_end__@@Base+0x1e52478> │ │ │ │ + bvs 1ef9038 <__bss_end__@@Base+0x1e52498> │ │ │ │ mrcvs 12, 3, r6, cr10, cr11, {2} │ │ │ │ @ instruction: 0xf77f429a │ │ │ │ ldclvs 15, cr10, [fp, #-204]! @ 0xffffff34 │ │ │ │ andle r2, r2, r0, lsl #22 │ │ │ │ @ instruction: 0xf7e36d78 │ │ │ │ - movwcs lr, #7486 @ 0x1d3e │ │ │ │ + movwcs lr, #7508 @ 0x1d54 │ │ │ │ @ instruction: 0x37684618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ subsge r9, r2, #3648 @ 0xe40 │ │ │ │ svccc 0x0091df46 │ │ │ │ strlt fp, [r0, #130] @ 0x82 │ │ │ │ svcge 0x0002b090 │ │ │ │ @ instruction: 0x61b961f8 │ │ │ │ cmppeq r0, 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0x4c │ │ │ │ vmul.f64 d7, d4, d0 │ │ │ │ ldmibvs fp!, {r0, r1, r2, r8, r9, fp, lr} │ │ │ │ - bvs 1efa504 <__bss_end__@@Base+0x1e538cc> │ │ │ │ + bvs 1efa48c <__bss_end__@@Base+0x1e538ec> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blcc 5adf0 │ │ │ │ - blvs 1efaa90 <__bss_end__@@Base+0x1e53e58> │ │ │ │ + blcc 5ad78 │ │ │ │ + blvs 1efaa18 <__bss_end__@@Base+0x1e53e78> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blvc 5adfc │ │ │ │ - blvc 21b040 <__bss_end__@@Base+0x174408> │ │ │ │ - blvc 21b088 <__bss_end__@@Base+0x174450> │ │ │ │ - blpl 21b050 <__bss_end__@@Base+0x174418> │ │ │ │ + blvc 5ad84 │ │ │ │ + blvc 21afc8 <__bss_end__@@Base+0x174428> │ │ │ │ + blvc 21b010 <__bss_end__@@Base+0x174470> │ │ │ │ + blpl 21afd8 <__bss_end__@@Base+0x174438> │ │ │ │ movwcc r6, #6971 @ 0x1b3b │ │ │ │ - bcc fe45afe0 <__bss_end__@@Base+0xfe3b43a8> │ │ │ │ - blvc ffa1b2a8 <__bss_end__@@Base+0xff974670> │ │ │ │ - blpl 21b060 <__bss_end__@@Base+0x174428> │ │ │ │ + bcc fe45af68 <__bss_end__@@Base+0xfe3b43c8> │ │ │ │ + blvc ffa1b230 <__bss_end__@@Base+0xff974690> │ │ │ │ + blpl 21afe8 <__bss_end__@@Base+0x174448> │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr} │ │ │ │ sbcseq r6, fp, fp, ror sl │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ vmul.f64 d7, d5, d0 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ fldmiaxvs fp!, {d23-d57} @ Deprecated │ │ │ │ - blvc 15adf4 <__bss_end__@@Base+0xb41bc> │ │ │ │ + blvc 15ad7c <__bss_end__@@Base+0xb41dc> │ │ │ │ ldc 12, cr6, [r3, #1004] @ 0x3ec │ │ │ │ @ instruction: 0x6c3a6b02 │ │ │ │ sbcseq r6, fp, fp, lsr fp │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ ldmibvs fp!, {r8, r9, fp, ip, lr} │ │ │ │ - bvs 1efa468 <__bss_end__@@Base+0x1e53830> │ │ │ │ + bvs 1efa3f0 <__bss_end__@@Base+0x1e53850> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blmi 5ae54 │ │ │ │ - blvs 1efaaf4 <__bss_end__@@Base+0x1e53ebc> │ │ │ │ + blmi 5addc │ │ │ │ + blvs 1efaa7c <__bss_end__@@Base+0x1e53edc> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 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lr} │ │ │ │ sbcseq r6, fp, fp, ror sl │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ vmul.f64 d7, d5, d0 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ fldmiaxvs fp!, {d23-d25} @ Deprecated │ │ │ │ - blvc dae74 <__bss_end__@@Base+0x3423c> │ │ │ │ + blvc dadfc <__bss_end__@@Base+0x3425c> │ │ │ │ ldc 12, cr6, [r3, #1004] @ 0x3ec │ │ │ │ @ instruction: 0x6c3a6b00 │ │ │ │ sbcseq r6, fp, fp, lsr fp │ │ │ │ ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ ldmibvs fp!, {r8, r9, fp, ip, lr} │ │ │ │ - bvs 1efa4e8 <__bss_end__@@Base+0x1e538b0> │ │ │ │ + bvs 1efa470 <__bss_end__@@Base+0x1e538d0> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blmi 5aed4 │ │ │ │ - blvs 1efaa74 <__bss_end__@@Base+0x1e53e3c> │ │ │ │ + blmi 5ae5c │ │ │ │ + blvs 1efa9fc <__bss_end__@@Base+0x1e53e5c> │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blvc 5aee0 │ │ │ │ - blmi 21b128 <__bss_end__@@Base+0x1744f0> │ │ │ │ - blvs 16b9f88 <__bss_end__@@Base+0x1613350> │ │ │ │ + blvc 5ae68 │ │ │ │ + blmi 21b0b0 <__bss_end__@@Base+0x174510> │ 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instruction: 0xf0000b47 │ │ │ │ rsbsvs pc, r8, #2293760 @ 0x230000 │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vldr d6, [r7, #24] │ │ │ │ - vldr d5, [pc, #24] @ 1fe0c │ │ │ │ + vldr d5, [pc, #24] @ 1fd94 │ │ │ │ vdiv.f64 d4, d5, d12 │ │ │ │ vadd.f64 d7, d6, d4 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 15b410 <__bss_end__@@Base+0xb47d8> │ │ │ │ + blvc 15b398 <__bss_end__@@Base+0xb47f8> │ │ │ │ ldmdavs fp!, {r0, r1, r2, sp, lr, pc}^ │ │ │ │ movwcs lr, #27091 @ 0x69d3 │ │ │ │ stmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ movwcs r2, #4868 @ 0x1304 │ │ │ │ - bvs 1ef8804 <__bss_end__@@Base+0x1e51bcc> │ │ │ │ + bvs 1ef878c <__bss_end__@@Base+0x1e51bec> │ │ │ │ @ instruction: 0x37284618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ addmi r4, pc, r0 │ │ │ │ adclt fp, r2, r0, lsl #11 │ │ │ │ stc 15, cr10, [r7] │ │ │ │ vstr d0, [r7, #16] │ │ │ │ rsbsvs r1, r8, r2, lsl #22 │ │ │ │ movwcs r6, #57 @ 0x39 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, r9, sl, sp, lr} │ │ │ │ - blcs 3a4b4 │ │ │ │ + blcs 3a43c │ │ │ │ andcs sp, r5, r4, lsl #2 │ │ │ │ @ instruction: 0xff42f7f7 │ │ │ │ mrs r2, SPSR_irq │ │ │ │ - blvc 15b4b4 <__bss_end__@@Base+0xb487c> │ │ │ │ - blvs fe8db4d8 <__bss_end__@@Base+0xfe8348a0> │ │ │ │ - blvc ff1db930 <__bss_end__@@Base+0xff134cf8> │ │ │ │ - blx 45ba28 <__bss_end__@@Base+0x3b4df0> │ │ │ │ + blvc 15b43c <__bss_end__@@Base+0xb489c> │ │ │ │ + blvs fe8db460 <__bss_end__@@Base+0xfe8348c0> │ │ │ │ + blvc ff1db8b8 <__bss_end__@@Base+0xff134d18> │ │ │ │ + blx 45b9b0 <__bss_end__@@Base+0x3b4e10> │ │ │ │ ldc 4, cr13, [r7, #32] │ │ │ │ - vldr d7, [pc, #16] @ 1fe7c │ │ │ │ + vldr d7, [pc, #16] @ 1fe04 │ │ │ │ @ instruction: 0xeeb46ba0 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ vstrle s30, [r3, #-64] @ 0xffffffc0 │ │ │ │ @ instruction: 0xf0436efb │ │ │ │ ldrbtvs r0, [fp], r1, lsl #6 │ │ │ │ - blvc db4e0 <__bss_end__@@Base+0x348a8> │ │ │ │ - blvs fe71b504 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cdp 7, 5, cr15, cr14, cr2, {7} │ │ │ │ svclt 0x0000e03d │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcsmi r7, r7, r0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ addsmi r4, pc, r0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ - andeq r0, r3, r2, lsr lr │ │ │ │ - andeq r0, r3, lr, lsl lr │ │ │ │ - andeq r0, r3, lr, lsl lr │ │ │ │ - andeq r0, r3, sl, lsl #28 │ │ │ │ - andeq r0, r3, lr, lsl #28 │ │ │ │ - andeq r0, r3, sl, lsl #28 │ │ │ │ - andeq r0, r3, sl, lsr #28 │ │ │ │ - andeq r0, r3, r4, asr lr │ │ │ │ - andeq r0, r3, sl, asr lr │ │ │ │ - ldrdeq r5, [r3], -ip │ │ │ │ - andeq r5, r3, sl, ror #19 │ │ │ │ - strdeq r5, [r3], -r8 │ │ │ │ - andeq r5, r3, r6, lsl #20 │ │ │ │ - andeq r5, r3, r4, lsl sl │ │ │ │ - andeq r5, r3, r8, lsl #20 │ │ │ │ - andeq r5, r3, lr, lsl #20 │ │ │ │ - andeq r5, r3, sl, lsl #20 │ │ │ │ - andeq r5, r3, r2, lsl sl │ │ │ │ - strdeq r0, [r3], -r4 │ │ │ │ - andeq r0, r3, r0, ror #23 │ │ │ │ + andeq r0, r3, sl, lsr #27 │ │ │ │ + muleq r3, r6, sp │ │ │ │ + muleq r3, r6, sp │ │ │ │ + andeq r0, r3, r2, lsl #27 │ │ │ │ + andeq r0, r3, r6, lsl #27 │ │ │ │ + andeq r0, r3, r2, lsl #27 │ │ │ │ + andeq r0, r3, r2, lsr #27 │ │ │ │ + andeq r0, r3, ip, asr #27 │ │ │ │ + ldrdeq r0, [r3], -r2 │ │ │ │ + andeq r5, r3, r4, asr r9 │ │ │ │ + andeq r5, r3, r2, ror #18 │ │ │ │ + andeq r5, r3, r0, ror r9 │ │ │ │ + andeq r5, r3, lr, ror r9 │ │ │ │ + andeq r5, r3, ip, lsl #19 │ │ │ │ + andeq r5, r3, r0, lsl #19 │ │ │ │ + andeq r5, r3, r6, lsl #19 │ │ │ │ + andeq r5, r3, r2, lsl #19 │ │ │ │ + andeq r5, r3, sl, lsl #19 │ │ │ │ + andeq r0, r3, ip, ror #22 │ │ │ │ + andeq r0, r3, r8, asr fp │ │ │ │ cmncs r8, #3522560 @ 0x35c000 │ │ │ │ ldrbtmi r4, [r9], #-2430 @ 0xfffff682 │ │ │ │ @ instruction: 0xf7e24608 │ │ │ │ - ldc 14, cr14, [r7, #32] │ │ │ │ + ldc 14, cr14, [r7, #128] @ 0x80 │ │ │ │ vmov.u16 r7, d5[3] │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ strle pc, [fp, #-2576] @ 0xfffff5f0 │ │ │ │ - blvc 1ddbd30 <__bss_end__@@Base+0x1d350f8> │ │ │ │ - blvc 121c19c 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│ │ │ │ - andeq r0, r3, r8, lsr #23 │ │ │ │ - andeq r0, r3, sl, lsl #27 │ │ │ │ - strdeq r5, [r3], -r8 │ │ │ │ - strdeq r5, [r3], -r6 │ │ │ │ - strdeq r5, [r3], -r4 │ │ │ │ - strdeq r5, [r3], -r2 │ │ │ │ - strdeq r5, [r3], -r0 │ │ │ │ - ldrdeq r5, [r3], -ip │ │ │ │ - ldrdeq r5, [r3], -sl │ │ │ │ - andeq r5, r3, lr, asr #17 │ │ │ │ - andeq r5, r3, sl, asr #17 │ │ │ │ + andeq r0, r3, sl, ror #21 │ │ │ │ + ldrdeq r0, [r3], -r6 │ │ │ │ + ldrdeq r0, [r3], -sl │ │ │ │ + andeq r0, r3, lr, asr #25 │ │ │ │ andeq r0, r3, r6, ror #25 │ │ │ │ + andeq r0, r3, r0, lsr #22 │ │ │ │ + andeq r0, r3, r2, lsl #26 │ │ │ │ + andeq r5, r3, r0, ror r8 │ │ │ │ + andeq r5, r3, lr, ror #16 │ │ │ │ + andeq r5, r3, ip, ror #16 │ │ │ │ + andeq r5, r3, sl, ror #16 │ │ │ │ + andeq r5, r3, r8, ror #16 │ │ │ │ + andeq r5, r3, r4, asr r8 │ │ │ │ + andeq r5, r3, r2, asr r8 │ │ │ │ + andeq r5, r3, r6, asr #16 │ │ │ │ + andeq r5, r3, r2, asr #16 │ │ │ │ + andeq r0, r3, lr, asr ip │ │ │ │ smullslt fp, r9, r0, r5 │ │ │ │ @ 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{r1, r3, r4, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ ldmdavs fp!, {r0, r3, r4, fp, sp, lr} │ │ │ │ ldmdavs fp, {r2, r8, r9, ip, sp} │ │ │ │ - blmi af25c4 <__bss_end__@@Base+0xa4b98c> │ │ │ │ + blmi af254c <__bss_end__@@Base+0xa4b9ac> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - b feddecec <__bss_end__@@Base+0xfed380b4> │ │ │ │ + b ff3dec74 <__bss_end__@@Base+0xff3380d4> │ │ │ │ ldrdcc pc, [r0], r7 │ │ │ │ tstle r5, r1, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2855 @ 0xfffff4d9 │ │ │ │ @ instruction: 0xf7e24618 │ │ │ │ - eor lr, fp, sl, ror fp │ │ │ │ + eor lr, fp, sl, lsl #23 │ │ │ │ ldrdcc pc, [r0], r7 │ │ │ │ tstle r5, r2, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2851 @ 0xfffff4dd │ │ │ │ @ instruction: 0xf7e24618 │ │ │ │ - eor lr, r1, r0, ror fp │ │ │ │ + eor lr, r1, r0, lsl #23 │ │ │ │ ldrbtmi r4, [fp], #-2849 @ 0xfffff4df │ │ │ │ @ instruction: 0xf7e24618 │ │ │ │ - muls fp, lr, sl │ │ │ │ + @ instruction: 0xe01beab6 │ │ │ │ ldc 1, cr2, [r7] │ │ │ │ andcs r0, r3, r6, lsl fp │ │ │ │ ldc2 7, cr15, [r6], {248} @ 0xf8 │ │ │ │ - blcs b25b4 <__bss_end__@@Base+0xb97c> │ │ │ │ - blcs d4df0 <__bss_end__@@Base+0x2e1b8> │ │ │ │ - blcs 57df0 │ │ │ │ - blcs 94dbc <__bss_start@@Base+0x39d1c> │ │ │ │ + blcs b253c <__bss_end__@@Base+0xb99c> │ │ │ │ + blcs d4d78 <__bss_end__@@Base+0x2e1d8> │ │ │ │ + blcs 57d78 │ │ │ │ + blcs 94d44 <__bss_start@@Base+0x39d3c> │ │ │ │ and sp, fp, r3 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ movwcs lr, #13 │ │ │ │ - blmi 57a9b0 <__bss_end__@@Base+0x4d3d78> │ │ │ │ + blmi 57a938 <__bss_end__@@Base+0x4d3d98> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - bl 13ded54 <__bss_end__@@Base+0x133811c> │ │ │ │ + bl 17decdc <__bss_end__@@Base+0x173813c> │ │ │ │ svclt 0x0000e000 │ │ │ │ - blcs 3c9c0 │ │ │ │ + blcs 3c948 │ │ │ │ svcge 0x0016f43f │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ @ instruction: 0x46bd3774 │ │ │ │ svclt 0x0000bd90 │ │ │ │ - andeq r7, r3, ip, lsr #8 │ │ │ │ - andeq pc, r2, r6, ror pc @ │ │ │ │ - andeq pc, r2, r2, ror #30 │ │ │ │ - strdeq r0, [r0], -ip │ │ │ │ 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instruction: 0xf8c72300 │ │ │ │ @ instruction: 0xf8d730c8 │ │ │ │ @ instruction: 0xf8c730c8 │ │ │ │ @ instruction: 0xf8d730c4 │ │ │ │ @ instruction: 0xf8c730c4 │ │ │ │ @ instruction: 0xf10730c0 │ │ │ │ ldc 3, cr0, [r3, #64] @ 0x40 │ │ │ │ - vldr d7, [pc] @ 21070 │ │ │ │ + vldr d7, [pc] @ 20ff8 │ │ │ │ vnmul.f64 d6, d7, d19 │ │ │ │ - vldr d6, [pc, #24] @ 21090 │ │ │ │ + vldr d6, [pc, #24] @ 21018 │ │ │ │ @ instruction: 0xee865b63 │ │ │ │ vstr d7, [r7, #20] │ │ │ │ vldr d7, [r7, #216] @ 0xd8 │ │ │ │ - vldr d7, [pc, #24] @ 210a0 │ │ │ │ + vldr d7, [pc, #24] @ 21028 │ │ │ │ @ instruction: 0xee276b5d │ │ │ │ - vldr d6, [pc, #24] @ 210a8 │ │ │ │ + vldr d6, [pc, #24] @ 21030 │ │ │ │ @ instruction: 0xee865b5d │ │ │ │ vstr d7, [r7, #20] │ │ │ │ movwcs r7, #2872 @ 0xb38 │ │ │ │ rscscc pc, r8, r7, asr #17 │ │ │ │ tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ - blvc dc4f4 <__bss_end__@@Base+0x358bc> │ │ │ │ - blvs 165c728 <__bss_end__@@Base+0x15b5af0> │ │ │ │ - blvc 1dc94c <__bss_end__@@Base+0x135d14> │ │ │ │ - blvc edc6d0 <__bss_end__@@Base+0xe35a98> │ │ │ │ + blvc dc47c <__bss_end__@@Base+0x358dc> │ │ │ │ + blvs 165c6b0 <__bss_end__@@Base+0x15b5b10> │ │ │ │ + blvc 1dc8d4 <__bss_end__@@Base+0x135d34> │ │ │ │ + blvc edc658 <__bss_end__@@Base+0xe35ab8> │ │ │ │ ldrbtmi r4, [fp], #-2914 @ 0xfffff49e │ │ │ │ bicsvs r2, sl, r0, lsl #4 │ │ │ │ ldrbtmi r4, [lr], #-3681 @ 0xfffff19f │ │ │ │ msreq CPSR_f, #-1073741823 @ 0xc0000001 │ │ │ │ stcge 3, cr9, [r8, #-72] @ 0xffffffb8 │ │ │ │ ldrbeq pc, [r8], #263 @ 0x107 @ │ │ │ │ - strgt ip, [pc, #-3087] @ 204c1 │ │ │ │ - strgt ip, [pc, #-3087] @ 204c5 │ │ │ │ + strgt ip, [pc, #-3087] @ 20449 │ │ │ │ + strgt ip, [pc, #-3087] @ 2044d │ │ │ │ muleq r3, r4, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ @ instruction: 0xf106466d │ │ │ │ stcgt 4, cr0, [pc], {16} │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1, r2, r3} │ │ │ │ ldm r6, {r0, r1, r2, r3} │ │ │ │ @ instruction: 0xf7fb000f │ │ │ │ - blmi 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#-1073741823 @ 0xc0000001 │ │ │ │ tstls r2, #805306369 @ 0x30000001 │ │ │ │ @ instruction: 0xf107ad08 │ │ │ │ stcgt 4, cr0, [pc], {216} @ 0xd8 │ │ │ │ stcgt 5, cr12, [pc], {15} │ │ │ │ ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ stm r5, {r0, r1} │ │ │ │ strbtmi r0, [sp], -r3 │ │ │ │ ldreq pc, [r0], #-262 @ 0xfffffefa │ │ │ │ - strgt ip, [pc, #-3087] @ 2054d │ │ │ │ + strgt ip, [pc, #-3087] @ 204d5 │ │ │ │ muleq pc, r4, r8 @ │ │ │ │ andeq lr, pc, r5, lsl #17 │ │ │ │ muleq pc, r6, r8 @ │ │ │ │ - bleq 119cc2c <__bss_end__@@Base+0x10f5ff4> │ │ │ │ - blne 11dcc30 <__bss_end__@@Base+0x1135ff8> │ │ │ │ - blcs 121cc34 <__bss_end__@@Base+0x1175ffc> │ │ │ │ + bleq 119cbb4 <__bss_end__@@Base+0x10f6014> │ │ │ │ + blne 11dcbb8 <__bss_end__@@Base+0x1136018> │ │ │ │ + blcs 121cbbc <__bss_end__@@Base+0x117601c> │ │ │ │ ldc2l 7, cr15, [r6, #-980]! @ 0xfffffc2c │ │ │ │ tstcs r8, #3522560 @ 0x35c000 │ │ │ │ orrvc pc, r8, r7, lsl #10 │ │ │ │ orrvc pc, r6, r1, lsr #11 │ │ │ │ stmib r1, {r0, r3, fp, sp, lr}^ │ │ │ │ ldmib r7, {r8, r9, sp}^ │ │ │ │ @ instruction: 0xf507231a │ │ │ │ @@ -30430,548 +30425,548 @@ │ │ │ │ stmdavs r9, {r1, r2, r7, r8, ip, sp, lr} │ │ │ │ movwcs lr, #10689 @ 0x29c1 │ │ │ │ tstcs ip, #3522560 @ 0x35c000 │ │ │ │ orrvc pc, r8, r7, lsl #10 │ │ │ │ orrvc pc, r6, r1, lsr #11 │ │ │ │ stmib r1, {r0, r3, fp, sp, lr}^ │ │ │ │ ldc 3, cr2, [r7, #16] │ │ │ │ - vldr d7, [pc, #72] @ 211fc │ │ │ │ + vldr d7, [pc, #72] @ 21184 │ │ │ │ vmov.32 d7[1], r6 │ │ │ │ - vldr d6, [pc, #24] @ 211d4 │ │ │ │ + vldr d6, [pc, #24] @ 2115c │ │ │ │ vdup.32 d6, r5 │ │ │ │ @ instruction: 0xf5077b05 │ │ │ │ @ instruction: 0xf5a37388 │ │ │ │ ldmdavs fp, {r1, r2, r7, r8, r9, ip, sp, lr} │ │ │ │ - blvc 25c7dc <__bss_end__@@Base+0x1b5ba4> │ │ │ │ - blvc 45c830 <__bss_end__@@Base+0x3b5bf8> │ │ │ │ - blvs 31c854 <__bss_end__@@Base+0x275c1c> │ │ │ │ - blvs 1dca78 <__bss_end__@@Base+0x135e40> │ │ │ │ - blpl 21c85c <__bss_end__@@Base+0x175c24> │ │ │ │ - blvc 19cbfc <__bss_end__@@Base+0xf5fc4> │ │ │ │ + blvc 25c764 <__bss_end__@@Base+0x1b5bc4> │ │ │ │ + blvc 45c7b8 <__bss_end__@@Base+0x3b5c18> │ │ │ │ + blvs 31c7dc <__bss_end__@@Base+0x275c3c> │ │ │ │ + blvs 1dca00 <__bss_end__@@Base+0x135e60> │ │ │ │ + blpl 21c7e4 <__bss_end__@@Base+0x175c44> │ │ │ │ + blvc 19cb84 <__bss_end__@@Base+0xf5fe4> │ │ │ │ orrvc pc, r8, #29360128 @ 0x1c00000 │ │ │ │ orrvc pc, r6, #683671552 @ 0x28c00000 │ │ │ │ stc 8, cr6, [r3, #108] @ 0x6c │ │ │ │ svclt 0x00007b06 │ │ │ │ strvc pc, [sl, r7, lsl #10] │ │ │ │ ldcllt 6, cr4, [r0, #756]! @ 0x2f4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ rscsle sl, r1, #252, 18 @ 0x3f0000 │ │ │ │ svccc 0x0050624d │ │ │ │ - andeq r7, r3, r6, lsl #1 │ │ │ │ - andeq fp, r3, sl, lsl #20 │ │ │ │ - andeq r5, r3, lr, lsl #8 │ │ │ │ - andeq r5, r3, r4, lsr #8 │ │ │ │ - andeq fp, r3, r6, ror #19 │ │ │ │ - andeq fp, r3, sl, lsr sl │ │ │ │ - andeq fp, r3, r8, lsr #20 │ │ │ │ + strdeq r7, [r3], -lr │ │ │ │ + andeq fp, r3, sl, ror #19 │ │ │ │ + andeq r5, r3, r6, lsl #7 │ │ │ │ + muleq r3, ip, r3 │ │ │ │ + andeq fp, r3, r6, asr #19 │ │ │ │ andeq fp, r3, sl, lsl sl │ │ │ │ - ldrdeq fp, [r3], -r0 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r5, r3, sl, ror r3 │ │ │ │ - andeq fp, r3, r2, ror #17 │ │ │ │ + andeq fp, r3, r8, lsl #20 │ │ │ │ strdeq fp, [r3], -sl │ │ │ │ - strdeq fp, [r3], -r0 │ │ │ │ - andeq fp, r3, lr, ror #17 │ │ │ │ - andeq fp, r3, ip, asr #17 │ │ │ │ - andeq fp, r3, r6, lsl #17 │ │ │ │ + @ instruction: 0x0003b9b0 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + strdeq r5, [r3], -r2 │ │ │ │ + andeq fp, r3, r2, asr #17 │ │ │ │ + ldrdeq fp, [r3], -sl │ │ │ │ + ldrdeq fp, [r3], -r0 │ │ │ │ + andeq fp, r3, lr, asr #17 │ │ │ │ + andeq fp, r3, ip, lsr #17 │ │ │ │ + andeq fp, r3, r6, ror #16 │ │ │ │ andeq r0, r0, r0 │ │ │ │ ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ andeq pc, r0, ip, asr #17 │ │ │ │ stcpl 5, cr15, [r0], {172} @ 0xac │ │ │ │ cdpeq 8, 4, cr15, cr8, cr12, {6} │ │ │ │ @ instruction: 0xf5ad4948 │ │ │ │ - bmi 12388ac <__bss_end__@@Base+0x1191c74> │ │ │ │ + bmi 1238834 <__bss_end__@@Base+0x1191c94> │ │ │ │ ldrbtmi fp, [r9], #-134 @ 0xffffff7a │ │ │ │ - bvc ff35e6b8 <__bss_end__@@Base+0xff2b7a80> │ │ │ │ + bvc ff35e640 <__bss_end__@@Base+0xff2b7aa0> │ │ │ │ bicvc pc, sl, #713031680 @ 0x2a800000 │ │ │ │ @ instruction: 0xf50d466e │ │ │ │ @ instruction: 0xf8df548c │ │ │ │ stmpl sl, {r4, r8, ip, pc} │ │ │ │ stmdbmi r3, {r2, r4, sl, ip, sp}^ │ │ │ │ ldmdavs r2, {r0, r3, r4, r5, r6, r7, sl, lr} │ │ │ │ @ instruction: 0xf04f6022 │ │ │ │ strcs r0, [r1, -r0, lsl #4] │ │ │ │ andcs r4, r0, #2030043136 @ 0x79000000 │ │ │ │ andsvs r4, sl, r0, lsl #13 │ │ │ │ @ instruction: 0xf7e16037 │ │ │ │ - stmdacs r0, {r1, r2, r6, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r3, r4, r6, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf1aad063 │ │ │ │ strmi r0, [r5], -r4, lsl #20 │ │ │ │ @ instruction: 0x46034639 │ │ │ │ rscsvc pc, pc, #64, 12 @ 0x4000000 │ │ │ │ @ instruction: 0xf7e24650 │ │ │ │ - strmi lr, [r7], -r4, lsr #18 │ │ │ │ + @ instruction: 0x4607e934 │ │ │ │ @ instruction: 0xf7e24628 │ │ │ │ - strmi lr, [r4], -ip, lsr #18 │ │ │ │ + @ instruction: 0x4604e93c │ │ │ │ @ instruction: 0xf7e14628 │ │ │ │ - bllt fe35cce4 <__bss_end__@@Base+0xfe2b60ac> │ │ │ │ + bllt fe35ccbc <__bss_end__@@Base+0xfe2b611c> │ │ │ │ mvnsvc pc, #64, 12 @ 0x4000000 │ │ │ │ umaalle r4, r2, pc, r2 @ │ │ │ │ ldcle 15, cr2, [r4, #-0] │ │ │ │ - bge 72c2c <__bss_start@@Base+0x17b8c> │ │ │ │ + bge 72bb4 <__bss_start@@Base+0x17bac> │ │ │ │ ldrtmi r2, [r1], -r4, ror #6 │ │ │ │ @ instruction: 0xf7f3466d │ │ │ │ - cmnplt r0, #74752 @ p-variant is OBSOLETE @ 0x12400 │ │ │ │ + cmnplt r0, #246784 @ p-variant is OBSOLETE @ 0x3c400 │ │ │ │ cmplt r3, #3342336 @ 0x330000 │ │ │ │ @ instruction: 0xf8c4f017 │ │ │ │ @ instruction: 0x46076833 │ │ │ │ vstrle d2, [r8, #-0] │ │ │ │ svcne 0x0004f855 │ │ │ │ @ instruction: 0xf0174638 │ │ │ │ ldmdavs r3!, {r0, r1, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ adcmi r3, r3, #16777216 @ 0x1000000 │ │ │ │ - bmi 9186f4 <__bss_end__@@Base+0x871abc> │ │ │ │ + bmi 91867c <__bss_end__@@Base+0x871adc> │ │ │ │ orrpl pc, ip, sp, lsl #10 │ │ │ │ tstcc r4, lr, lsl fp │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ stmdavs fp, {r1, r3, r4, fp, sp, lr} │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xd12e0300 │ │ │ │ @ instruction: 0xf50d4638 │ │ │ │ andlt r5, r6, ip, lsl #27 │ │ │ │ @ instruction: 0x87f0e8bd │ │ │ │ @ instruction: 0x46424b1a │ │ │ │ ldrbtmi r4, [r9], #-2330 @ 0xfffff6e6 │ │ │ │ andcc pc, r3, r9, asr r8 @ │ │ │ │ @ instruction: 0xf7e26818 │ │ │ │ - strcs lr, [r0, -r4, lsr #16] │ │ │ │ - blmi 59b2dc <__bss_end__@@Base+0x4f46a4> │ │ │ │ + smladxcs r0, ip, r8, lr │ │ │ │ + blmi 59b264 <__bss_end__@@Base+0x4f46c4> │ │ │ │ ldmdbmi r6, {r1, r6, r9, sl, lr} │ │ │ │ @ instruction: 0xf8594479 │ │ │ │ ldmdavs r8, {r0, r1, ip, sp} │ │ │ │ - ldmda r8, {r1, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blmi 45b338 <__bss_end__@@Base+0x3b4700> │ │ │ │ + ldmda r0!, {r1, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blmi 45b2c0 <__bss_end__@@Base+0x3b4720> │ │ │ │ ldmdbmi r2, {r1, r6, r9, sl, lr} │ │ │ │ @ instruction: 0xf8594479 │ │ │ │ ldmdavs r8, {r0, r1, ip, sp} │ │ │ │ - stmda lr, {r1, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blmi 31b324 <__bss_end__@@Base+0x2746ec> │ │ │ │ + stmda r6!, {r1, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blmi 31b2ac <__bss_end__@@Base+0x27470c> │ │ │ │ stmdbmi lr, {r1, r6, r9, sl, lr} │ │ │ │ @ instruction: 0xf8594479 │ │ │ │ ldmdavs r8, {r0, r1, ip, sp} │ │ │ │ - stmda r4, {r1, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda ip, {r1, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7e2e7df │ │ │ │ - svclt 0x0000e814 │ │ │ │ - andeq r6, r3, r2, lsl #27 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r6, r3, r8, ror #26 │ │ │ │ - andeq fp, r2, ip, lsr #6 │ │ │ │ - ldrdeq r6, [r3], -ip │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - strdeq r8, [r2], -r6 │ │ │ │ - andeq r8, r2, r0, lsr #26 │ │ │ │ - strdeq r8, [r2], -r0 │ │ │ │ - @ instruction: 0x00028cb8 │ │ │ │ + svclt 0x0000e82c │ │ │ │ + strdeq r6, [r3], -sl │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r6, r3, r0, ror #27 │ │ │ │ + andeq fp, r2, r0, asr r5 │ │ │ │ + andeq r6, r3, r4, asr sp │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r8, r2, sl, lsr pc │ │ │ │ + andeq r8, r2, r4, ror #30 │ │ │ │ + andeq r8, r2, r4, lsr pc │ │ │ │ + strdeq r8, [r2], -ip │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi dc880 <__bss_end__@@Base+0x35c48> │ │ │ │ + blhi dc808 <__bss_end__@@Base+0x35c68> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ - bleq 1e5f704 <__bss_end__@@Base+0x1db8acc> │ │ │ │ + bleq 1e5f68c <__bss_end__@@Base+0x1db8aec> │ │ │ │ ldmdami pc, {r0, r1, r2, r9, sl, lr}^ @ │ │ │ │ ldmdbmi pc, {r1, r2, r3, r9, sl, lr}^ @ │ │ │ │ @ instruction: 0xf2ad4478 │ │ │ │ stcge 13, cr4, [r4, #-400] @ 0xfffffe70 │ │ │ │ - blvc 5ca34 <__bss_start@@Base+0x1994> │ │ │ │ + blvc 5c9bc <__bss_start@@Base+0x19b4> │ │ │ │ stmdapl r1, {r2, r4, r9, sl, lr}^ │ │ │ │ strgt pc, [r8], #2269 @ 0x8dd │ │ │ │ @ instruction: 0xf8cd6809 │ │ │ │ @ instruction: 0xf04f145c │ │ │ │ stc 1, cr0, [r5] │ │ │ │ vldr d7, [r3] │ │ │ │ ldmib r3, {r1, r8, r9, fp, ip, sp, lr}^ │ │ │ │ stmib r5, {r2, r8, r9, sp}^ │ │ │ │ @ instruction: 0xf8dd2304 │ │ │ │ stc 4, cr8, [r5, #576] @ 0x240 │ │ │ │ @ instruction: 0xb1247b02 │ │ │ │ - blcs 1bb8a4 <__bss_end__@@Base+0x114c6c> │ │ │ │ - blcs 9107c <__bss_start@@Base+0x35fdc> │ │ │ │ + blcs 1bb82c <__bss_end__@@Base+0x114c8c> │ │ │ │ + blcs 91004 <__bss_start@@Base+0x35ffc> │ │ │ │ ldc 0, cr13, [r5, #-136] @ 0xffffff78 │ │ │ │ ldmdbge r6, {r1, r8, r9, fp} │ │ │ │ cdp 6, 11, cr4, cr7, cr8, {1} │ │ │ │ vmov.f64 d2, #32 @ 0x41000000 8.0 │ │ │ │ andcs r1, r0, #14336 @ 0x3800 │ │ │ │ stmib r1, {r8, r9, sp}^ │ │ │ │ stmib r1, {r8, r9, sp}^ │ │ │ │ stmib r1, {r1, r8, r9, sp}^ │ │ │ │ @ instruction: 0xf00a2304 │ │ │ │ - bmi 11e0608 <__bss_end__@@Base+0x11399d0> │ │ │ │ + bmi 11e0590 <__bss_end__@@Base+0x11399f0> │ │ │ │ ldrbtmi r4, [sl], #-2884 @ 0xfffff4bc │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ ldrbcc pc, [ip], #-2269 @ 0xfffff723 @ │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ cmnle r7, r0, lsl #6 │ │ │ │ stclmi 2, cr15, [r4, #-52]! @ 0xffffffcc │ │ │ │ - blhi dc754 <__bss_end__@@Base+0x35b1c> │ │ │ │ + blhi dc6dc <__bss_end__@@Base+0x35b3c> │ │ │ │ mvnshi lr, #12386304 @ 0xbd0000 │ │ │ │ @ instruction: 0xf10d4660 │ │ │ │ @ instruction: 0xf7e90928 │ │ │ │ - vldr d15, [pc, #484] @ 21654 │ │ │ │ + vldr d15, [pc, #268] @ 21504 │ │ │ │ vldr d4, [r4, #220] @ 0xdc │ │ │ │ ldmdage r0, {r1, r4, r5, r8, r9, fp, ip, lr} │ │ │ │ - blvs d5cacc <__bss_end__@@Base+0xcb5e94> │ │ │ │ + blvs d5ca54 <__bss_end__@@Base+0xcb5eb4> │ │ │ │ @ instruction: 0x71acf504 │ │ │ │ - blvc ddcad4 <__bss_end__@@Base+0xd35e9c> │ │ │ │ + blvc ddca5c <__bss_end__@@Base+0xd35ebc> │ │ │ │ cdp 6, 2, cr4, cr5, cr10, {2} │ │ │ │ vmov.f64 d5, #4 @ 0x40200000 2.5 │ │ │ │ vnmul.f64 d8, d6, d0 │ │ │ │ vmul.f64 d6, d7, d4 │ │ │ │ vstr d7, [r0, #16] │ │ │ │ vstr d5, [r0] │ │ │ │ vstr d6, [r0, #8] │ │ │ │ - @ instruction: 0xf7e97b04 │ │ │ │ - ldc 15, cr15, [r8, #588] @ 0x24c │ │ │ │ + @ instruction: 0xf7ea7b04 │ │ │ │ + @ instruction: 0xed98f920 │ │ │ │ strbmi r2, [r8], -r9, lsl #20 │ │ │ │ - bvs 2dcb10 <__bss_end__@@Base+0x235ed8> │ │ │ │ - bvc 31cb14 <__bss_end__@@Base+0x275edc> │ │ │ │ - bcs ff0dcf94 <__bss_end__@@Base+0xff03635c> │ │ │ │ - blcc 2dcb30 <__bss_end__@@Base+0x235ef8> │ │ │ │ - bvs ff1dcf9c <__bss_end__@@Base+0xff136364> │ │ │ │ - blmi 35cb38 <__bss_end__@@Base+0x2b5f00> │ │ │ │ - bvc ff21cfa4 <__bss_end__@@Base+0xff17636c> │ │ │ │ - blpl 3dcb40 <__bss_end__@@Base+0x335f08> │ │ │ │ - blcc 111cd98 <__bss_end__@@Base+0x1076160> │ │ │ │ - blvs 115cdac <__bss_end__@@Base+0x10b6174> │ │ │ │ - blvc 119cdb4 <__bss_end__@@Base+0x10f617c> │ │ │ │ - blcc 2dcb10 <__bss_end__@@Base+0x235ed8> │ │ │ │ - blvs 35cb14 <__bss_end__@@Base+0x2b5edc> │ │ │ │ - blvc 3dcb18 <__bss_end__@@Base+0x335ee0> │ │ │ │ - blx f5f48e <__bss_end__@@Base+0xeb8856> │ │ │ │ + bvs 2dca98 <__bss_end__@@Base+0x235ef8> │ │ │ │ + bvc 31ca9c <__bss_end__@@Base+0x275efc> │ │ │ │ + bcs ff0dcf1c <__bss_end__@@Base+0xff03637c> │ │ │ │ + blcc 2dcab8 <__bss_end__@@Base+0x235f18> │ │ │ │ + bvs ff1dcf24 <__bss_end__@@Base+0xff136384> │ │ │ │ + blmi 35cac0 <__bss_end__@@Base+0x2b5f20> │ │ │ │ + bvc ff21cf2c <__bss_end__@@Base+0xff17638c> │ │ │ │ + blpl 3dcac8 <__bss_end__@@Base+0x335f28> │ │ │ │ + blcc 111cd20 <__bss_end__@@Base+0x1076180> │ │ │ │ + blvs 115cd34 <__bss_end__@@Base+0x10b6194> │ │ │ │ + blvc 119cd3c <__bss_end__@@Base+0x10f619c> │ │ │ │ + blcc 2dca98 <__bss_end__@@Base+0x235ef8> │ │ │ │ + blvs 35ca9c <__bss_end__@@Base+0x2b5efc> │ │ │ │ + blvc 3dcaa0 <__bss_end__@@Base+0x335f00> │ │ │ │ + blx 1df416 <__bss_end__@@Base+0x138876> │ │ │ │ movwls sl, #2818 @ 0xb02 │ │ │ │ - blne 105cfb0 <__bss_end__@@Base+0xfb6378> │ │ │ │ + blne 105cf38 <__bss_end__@@Base+0xfb6398> │ │ │ │ cmppeq r8, r8, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - bleq 125cfb8 <__bss_end__@@Base+0x11b6380> │ │ │ │ + bleq 125cf40 <__bss_end__@@Base+0x11b63a0> │ │ │ │ ldrhcc pc, [r2], #-136 @ 0xffffff78 @ │ │ │ │ ldrhcs pc, [r0], #-136 @ 0xffffff78 @ │ │ │ │ @ instruction: 0xf0054620 │ │ │ │ stmiblt r8!, {r0, r1, r2, r3, r4, sl, fp, ip, sp, lr, pc} │ │ │ │ andsle r2, sl, r1, lsl #30 │ │ │ │ ldrbtmi r4, [fp], #-2836 @ 0xfffff4ec │ │ │ │ @ instruction: 0x36144a14 │ │ │ │ cdpge 6, 1, cr9, cr13, cr0, {0} │ │ │ │ vst3.16 {d20-d22}, [pc :256], sl │ │ │ │ @ instruction: 0x4630717a │ │ │ │ - svc 0x00eaf7e1 │ │ │ │ + svc 0x00faf7e1 │ │ │ │ orrpl pc, r0, #4, 10 @ 0x1000000 │ │ │ │ @ instruction: 0x46204631 │ │ │ │ teqpcc ip, r3 @ @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xe7744798 │ │ │ │ - blvc 15d000 <__bss_end__@@Base+0xb63c8> │ │ │ │ - bleq 121cffc <__bss_end__@@Base+0x11763c4> │ │ │ │ - blvc dc954 <__bss_end__@@Base+0x35d1c> │ │ │ │ - blmi 29b300 <__bss_end__@@Base+0x1f46c8> │ │ │ │ + blvc 15cf88 <__bss_end__@@Base+0xb63e8> │ │ │ │ + bleq 121cf84 <__bss_end__@@Base+0x11763e4> │ │ │ │ + blvc dc8dc <__bss_end__@@Base+0x35d3c> │ │ │ │ + blmi 29b288 <__bss_end__@@Base+0x1f46e8> │ │ │ │ @ instruction: 0xe7e3447b │ │ │ │ - svc 0x0038f7e1 │ │ │ │ - bvs fe0a7f10 <__bss_end__@@Base+0xfe0012d8> │ │ │ │ + svc 0x0050f7e1 │ │ │ │ + bvs fe0a7e98 <__bss_end__@@Base+0xfe0012f8> │ │ │ │ svccc 0x00d381da │ │ │ │ - andeq r6, r3, r4, lsr #24 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - @ instruction: 0x00036bba │ │ │ │ - andeq r8, r2, r6, lsr #23 │ │ │ │ - andeq r8, r2, r0, asr #23 │ │ │ │ - andeq r8, r2, r0, ror #22 │ │ │ │ + muleq r3, ip, ip │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r6, r3, r2, lsr ip │ │ │ │ + andeq r8, r2, sl, ror #27 │ │ │ │ + andeq r8, r2, r4, lsl #28 │ │ │ │ + andeq r8, r2, r4, lsr #27 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00d0f8cc │ │ │ │ movwcs r4, #1567 @ 0x61f │ │ │ │ ldrdhi pc, [r8, -pc]! @ │ │ │ │ strmi fp, [ip], -r3, lsl #1 │ │ │ │ eorsvs r4, fp, r1, lsl #13 │ │ │ │ @ instruction: 0x469244f8 │ │ │ │ - blcs 7f5c0 <__bss_start@@Base+0x24520> │ │ │ │ - blcs d56cc <__bss_end__@@Base+0x2ea94> │ │ │ │ - blmi 1195abc <__bss_end__@@Base+0x10eee84> │ │ │ │ + blcs 7f548 <__bss_start@@Base+0x24540> │ │ │ │ + blcs d5654 <__bss_end__@@Base+0x2eab4> │ │ │ │ + blmi 1195a44 <__bss_end__@@Base+0x10eeea4> │ │ │ │ @ instruction: 0xf8584620 │ │ │ │ movwcs fp, #36867 @ 0x9003 │ │ │ │ @ instruction: 0xf0159300 │ │ │ │ strmi pc, [r3], -r5, ror #31 │ │ │ │ suble r2, fp, r0, lsl #16 │ │ │ │ strcs r4, [r0, #-1628] @ 0xfffff9a4 │ │ │ │ strcc lr, [r1, #-4] │ │ │ │ strpl pc, [sl], #1284 @ 0x504 │ │ │ │ subsle r2, r6, r0, lsr #26 │ │ │ │ @ instruction: 0x2e006926 │ │ │ │ vst4. {d29,d31,d33,d35}, [pc :256], r7 │ │ │ │ ldrtmi r5, [r1], -sl, lsl #5 │ │ │ │ movwls r4, #5664 @ 0x1620 │ │ │ │ - ldcl 7, cr15, [sl, #-900] @ 0xfffffc7c │ │ │ │ - blls 33eb4 │ │ │ │ + ldcl 7, cr15, [r0, #-900]! @ 0xfffffc7c │ │ │ │ + blls 33e3c │ │ │ │ eorvs r2, r5, r0, lsr #2 │ │ │ │ strpl pc, [r0, #1284] @ 0x504 │ │ │ │ @ instruction: 0xf1046123 │ │ │ │ @ instruction: 0xf8c40014 │ │ │ │ - blls 896bc <__bss_start@@Base+0x2e61c> │ │ │ │ + blls 89644 <__bss_start@@Base+0x2e63c> │ │ │ │ andgt pc, r2, r8, asr r8 @ │ │ │ │ ldmib ip, {r0, r4, r5, r9, fp, lr}^ │ │ │ │ stmib r4, {r8, r9, fp, sp, pc}^ │ │ │ │ ldrbtmi sl, [sl], #-2830 @ 0xfffff4f2 │ │ │ │ adcls pc, r8, r5, asr #17 │ │ │ │ msrcc CPSR_fs, #196, 16 @ 0xc40000 │ │ │ │ - blx fe15f5d2 <__bss_end__@@Base+0xfe0b899a> │ │ │ │ + stc2 7, cr15, [ip], #-968 @ 0xfffffc38 │ │ │ │ mvnsvc pc, #82837504 @ 0x4f00000 │ │ │ │ teqpcc r8, #164, 16 @ p-variant is OBSOLETE @ 0xa40000 │ │ │ │ rscvs r6, r6, r3, lsr #18 │ │ │ │ @ instruction: 0xf8c42b08 │ │ │ │ eorsle r6, r9, r8, lsr #6 │ │ │ │ @ instruction: 0xf8584b27 │ │ │ │ - blmi 9e9630 <__bss_end__@@Base+0x9429f8> │ │ │ │ + blmi 9e95b8 <__bss_end__@@Base+0x942a18> │ │ │ │ stmib r5, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ eorsvs r2, ip, lr, asr #6 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ - blmi 9455f4 <__bss_end__@@Base+0x89e9bc> │ │ │ │ + blmi 94557c <__bss_end__@@Base+0x89e9dc> │ │ │ │ @ instruction: 0xf8584620 │ │ │ │ movwcs fp, #32771 @ 0x8003 │ │ │ │ @ instruction: 0xf0159300 │ │ │ │ @ instruction: 0x4603ff99 │ │ │ │ @ instruction: 0xd1b32800 │ │ │ │ strtmi r9, [r0], -r1 │ │ │ │ - blx feddf602 <__bss_end__@@Base+0xfed389ca> │ │ │ │ + @ instruction: 0xffaaf7ec │ │ │ │ ldmdami sp, {r0, r9, sl, lr} │ │ │ │ @ instruction: 0xf7e14478 │ │ │ │ - blls 9cf4c <__bss_start@@Base+0x41eac> │ │ │ │ + blls 9cf34 <__bss_start@@Base+0x41f2c> │ │ │ │ @ instruction: 0x4618491b │ │ │ │ @ instruction: 0xf0154479 │ │ │ │ strmi pc, [r3], -r9, ror #30 │ │ │ │ @ instruction: 0xd1a12800 │ │ │ │ - bmi 65b5e8 <__bss_end__@@Base+0x5b49b0> │ │ │ │ + bmi 65b570 <__bss_end__@@Base+0x5b49d0> │ │ │ │ @ instruction: 0xf8584b14 │ │ │ │ @ instruction: 0xf8582002 │ │ │ │ ldmdavs r0, {r0, r1, ip, sp} │ │ │ │ mulsle r1, fp, r5 │ │ │ │ ldrbtmi r4, [r9], #-2324 @ 0xfffff6ec │ │ │ │ andlt r4, r3, sl, lsr #12 │ │ │ │ svcmi 0x00f0e8bd │ │ │ │ - cdplt 7, 8, cr15, cr2, cr1, {7} │ │ │ │ + cdplt 7, 9, cr15, cr10, cr1, {7} │ │ │ │ @ instruction: 0xf01e4620 │ │ │ │ strtmi pc, [r0], -fp, lsr #24 │ │ │ │ cdp2 0, 10, cr15, cr12, cr11, {0} │ │ │ │ @ instruction: 0xf00b4620 │ │ │ │ ldr pc, [fp, sp, asr #30]! │ │ │ │ ldrbtmi r4, [r9], #-2316 @ 0xfffff6f4 │ │ │ │ svclt 0x0000e7ec │ │ │ │ - andeq r6, r3, r4, ror sl │ │ │ │ - andeq r0, r0, r8, lsl #5 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - andeq r9, r2, r2, lsr r9 │ │ │ │ - andeq r0, r0, r0, ror #4 │ │ │ │ + andeq r6, r3, ip, ror #21 │ │ │ │ + andeq r0, r0, r0, lsl #5 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + andeq r9, r2, r6, ror #22 │ │ │ │ + andeq r0, r0, r8, asr r2 │ │ │ │ strheq r0, [r0], -r5 │ │ │ │ - andeq r0, r0, r0, lsr #5 │ │ │ │ - muleq r2, r4, sl │ │ │ │ - @ instruction: 0x00028ab8 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - ldrdeq r8, [r2], -r2 │ │ │ │ - andeq r8, r2, r6, ror sl │ │ │ │ + muleq r0, r8, r2 │ │ │ │ + ldrdeq r8, [r2], -r8 @ │ │ │ │ + strdeq r8, [r2], -ip │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r8, r2, r6, lsl sp │ │ │ │ + @ instruction: 0x00028cba │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb788e4 <__bss_end__@@Base+0xfead1cac> │ │ │ │ + bl feb7886c <__bss_end__@@Base+0xfead1ccc> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000fe8 │ │ │ │ strmi r5, [r4], -r0, lsl #11 │ │ │ │ cdpmi 8, 1, cr6, cr4, cr7, {0} │ │ │ │ ldrdeq pc, [r4, -r5] │ │ │ │ - blx a5f6c4 <__bss_end__@@Base+0x9b8a8c> │ │ │ │ + blx ff45f64c <__bss_end__@@Base+0xff3b8aac> │ │ │ │ @ instruction: 0xf00b4620 │ │ │ │ strtmi pc, [r0], -r9, ror #28 │ │ │ │ @ instruction: 0xf9f0f00a │ │ │ │ @ instruction: 0xf01e4620 │ │ │ │ stmiavs r3!, {r0, r3, r5, sl, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x07da447e │ │ │ │ - bmi 356b28 <__bss_end__@@Base+0x2afef0> │ │ │ │ + bmi 356ab0 <__bss_end__@@Base+0x2aff10> │ │ │ │ stmdavs sl, {r0, r4, r5, r7, fp, ip, lr} │ │ │ │ andvs r3, sl, r1, lsl #20 │ │ │ │ strle r0, [fp], #-1691 @ 0xfffff965 │ │ │ │ ldrdeq pc, [r8], r5 @ │ │ │ │ cdp2 0, 3, cr15, cr6, cr6, {0} │ │ │ │ addpl pc, sl, #1325400064 @ 0x4f000000 │ │ │ │ strtmi r2, [r0], -r0, lsl #2 │ │ │ │ - stc 7, cr15, [r8], #900 @ 0x384 │ │ │ │ + ldc 7, cr15, [lr], #900 @ 0x384 │ │ │ │ ldcllt 0, cr6, [r8, #156]! @ 0x9c │ │ │ │ @ instruction: 0xf0046820 │ │ │ │ ubfx pc, pc, #20, #16 │ │ │ │ - strdeq r6, [r3], -r0 │ │ │ │ - andeq r0, r0, r8, lsr r3 │ │ │ │ + andeq r6, r3, r8, ror #18 │ │ │ │ + andeq r0, r0, r0, lsr r3 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb78954 <__bss_end__@@Base+0xfead1d1c> │ │ │ │ + bl feb788dc <__bss_end__@@Base+0xfead1d3c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r6], {248} @ 0xf8 │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ stmdavs r3, {r4, r5, r8, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f26023 │ │ │ │ - stmdavs r0!, {r0, r4, r5, r6, r7, r8, fp, ip, sp, lr, pc} │ │ │ │ + stmdavs r0!, {r0, r3, r4, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ svclt 0x0000bd10 │ │ │ │ - andeq fp, r3, ip, lsr #5 │ │ │ │ + andeq fp, r3, ip, lsl #5 │ │ │ │ ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 25cc38 <__bss_end__@@Base+0x1b6000> │ │ │ │ + blhi 25cbc0 <__bss_end__@@Base+0x1b6020> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00b0f8cc │ │ │ │ - blls 5d268 <__bss_start@@Base+0x21c8> │ │ │ │ - blge 10dd254 <__bss_end__@@Base+0x103661c> │ │ │ │ - bllt 25d274 <__bss_end__@@Base+0x1b663c> │ │ │ │ + blls 5d1f0 <__bss_start@@Base+0x21e8> │ │ │ │ + blge 10dd1dc <__bss_end__@@Base+0x103663c> │ │ │ │ + bllt 25d1fc <__bss_end__@@Base+0x1b665c> │ │ │ │ cdp 0, 3, cr11, cr1, cr4, {4} │ │ │ │ vmov.f64 d1, #9 @ 0x40480000 3.125 │ │ │ │ strmi r8, [r5], -r0, asr #22 │ │ │ │ cdp 6, 2, cr4, cr2, cr8, {0} │ │ │ │ ldrmi fp, [r1], fp, lsl #22 │ │ │ │ pkhbtmi r4, r8, pc, lsl #12 @ │ │ │ │ - blvc ff09d3a8 <__bss_end__@@Base+0xfeff6770> │ │ │ │ + blvc ff09d330 <__bss_end__@@Base+0xfeff6790> │ │ │ │ ldrbtmi r4, [lr], #-3633 @ 0xfffff1cf │ │ │ │ - bmi fe45d018 <__bss_end__@@Base+0xfe3b63e0> │ │ │ │ - ldc 7, cr15, [r0, #-900]! @ 0xfffffc7c │ │ │ │ - blvs 29d0ac <__bss_end__@@Base+0x1f6474> │ │ │ │ + bmi fe45cfa0 <__bss_end__@@Base+0xfe3b6400> │ │ │ │ + stcl 7, cr15, [r8, #-900] @ 0xfffffc7c │ │ │ │ + blvs 29d034 <__bss_end__@@Base+0x1f6494> │ │ │ │ vadd.f32 s8, s16, s29 │ │ │ │ strbmi r7, [r3], -r9, lsl #22 │ │ │ │ - blvs ff1dd3c4 <__bss_end__@@Base+0xff13678c> │ │ │ │ + blvs ff1dd34c <__bss_end__@@Base+0xff1367ac> │ │ │ │ andge pc, r2, r6, asr r8 @ │ │ │ │ - blvc ff21d3cc <__bss_end__@@Base+0xff176794> │ │ │ │ + blvc ff21d354 <__bss_end__@@Base+0xff1767b4> │ │ │ │ stcl 0, cr9, [sp] │ │ │ │ vnmls.f32 s12, s12, s2 │ │ │ │ @ instruction: 0xf8ba8a90 │ │ │ │ cdp 0, 1, cr2, cr7, cr0, {0} │ │ │ │ andls r1, r2, #144, 20 @ 0x90000 │ │ │ │ - bvs 1a33078 <__bss_end__@@Base+0x198c440> │ │ │ │ - blx 195f796 <__bss_end__@@Base+0x18b8b5e> │ │ │ │ + bvs 1a33000 <__bss_end__@@Base+0x198c460> │ │ │ │ + blx 15f71e <__bss_end__@@Base+0xb8b7e> │ │ │ │ @ instruction: 0xf7e14648 │ │ │ │ - mrc 13, 5, lr, cr2, cr4, {0} │ │ │ │ + cdp 13, 11, cr14, cr2, cr12, {1} │ │ │ │ vmov.f64 d5, #10 @ 0x40500000 3.250 │ │ │ │ - bmi 840524 <__bss_end__@@Base+0x7998ec> │ │ │ │ - blvc 19d030 <__bss_end__@@Base+0xf63f8> │ │ │ │ - beq fe45d020 <__bss_end__@@Base+0xfe3b63e8> │ │ │ │ - blvs 29d0fc <__bss_end__@@Base+0x1f64c4> │ │ │ │ + bmi 8404ac <__bss_end__@@Base+0x79990c> │ │ │ │ + blvc 19cfb8 <__bss_end__@@Base+0xf6418> │ │ │ │ + beq fe45cfa8 <__bss_end__@@Base+0xfe3b6408> │ │ │ │ + blvs 29d084 <__bss_end__@@Base+0x1f64e4> │ │ │ │ cdp 6, 11, cr4, cr8, cr11, {2} │ │ │ │ ldmpl r2!, {r0, r2, r5, r6, r7, r8, r9, fp, ip, lr} │ │ │ │ cdp 0, 11, cr9, cr13, cr0, {0} │ │ │ │ vmls.f64 d6, d21, d6 │ │ │ │ ldmdahi r2, {r0, r1, r3, r6, r8, r9, fp, ip, sp, lr} │ │ │ │ strtmi r9, [r2], -r2, lsl #4 │ │ │ │ - bvs 9ce60 <__bss_start@@Base+0x41dc0> │ │ │ │ + bvs 9cde8 <__bss_start@@Base+0x41de0> │ │ │ │ vsub.f32 s12, s14, s17 │ │ │ │ vmov.f64 d23, #217 @ 0xbec80000 -0.3906250 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ @ instruction: 0xf7e81a90 │ │ │ │ - @ instruction: 0x4638fb3f │ │ │ │ - stcl 7, cr15, [lr], #900 @ 0x384 │ │ │ │ - blvc 35d310 <__bss_end__@@Base+0x2b66d8> │ │ │ │ + @ instruction: 0x4638fadf │ │ │ │ + stc 7, cr15, [r6, #-900] @ 0xfffffc7c │ │ │ │ + blvc 35d298 <__bss_end__@@Base+0x2b66f8> │ │ │ │ andhi pc, r4, sp, asr #17 │ │ │ │ cdp 6, 0, cr4, cr10, cr1, {0} │ │ │ │ ldrtmi r8, [fp], -r7, lsl #22 │ │ │ │ @ instruction: 0x6000f8ba │ │ │ │ - bvs 1a330e4 <__bss_end__@@Base+0x198c4ac> │ │ │ │ + bvs 1a3306c <__bss_end__@@Base+0x198c4cc> │ │ │ │ strls r9, [r2], -r0, lsl #2 │ │ │ │ - blhi 29d144 <__bss_end__@@Base+0x1f650c> │ │ │ │ - blvc ff25d45c <__bss_end__@@Base+0xff1b6824> │ │ │ │ - bne fe45d0c8 <__bss_end__@@Base+0xfe3b6490> │ │ │ │ - blx 9df812 <__bss_end__@@Base+0x938bda> │ │ │ │ + blhi 29d0cc <__bss_end__@@Base+0x1f652c> │ │ │ │ + blvc ff25d3e4 <__bss_end__@@Base+0xff1b6844> │ │ │ │ + bne fe45d050 <__bss_end__@@Base+0xfe3b64b0> │ │ │ │ + blx ff1df798 <__bss_end__@@Base+0xff138bf8> │ │ │ │ ldc 0, cr11, [sp], #16 │ │ │ │ pop {r3, r8, r9, fp, pc} │ │ │ │ svclt 0x000087f0 │ │ │ │ - andeq r6, r3, sl, asr #16 │ │ │ │ - @ instruction: 0x000002b0 │ │ │ │ - andeq r0, r0, r0, ror r2 │ │ │ │ + andeq r6, r3, r2, asr #17 │ │ │ │ + andeq r0, r0, r8, lsr #5 │ │ │ │ + andeq r0, r0, r8, ror #4 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb78a90 <__bss_end__@@Base+0xfead1e58> │ │ │ │ + bl feb78a18 <__bss_end__@@Base+0xfead1e78> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000fe8 │ │ │ │ cdpmi 7, 2, cr5, cr5, cr0, {0} │ │ │ │ @ instruction: 0xf8d7447e │ │ │ │ @ instruction: 0xb1b441cc │ │ │ │ ldmiblt fp, {r0, r1, r5, r7, fp, sp, lr} │ │ │ │ tstcs r1, r2, lsr #20 │ │ │ │ cdp 1, 11, cr6, cr7, cr3, {1} │ │ │ │ adcvs r6, r1, r0, lsl #22 │ │ │ │ - blpl 15d380 <__bss_end__@@Base+0xb6748> │ │ │ │ + blpl 15d308 <__bss_end__@@Base+0xb6768> │ │ │ │ adcvs r5, r3, #11665408 @ 0xb20000 │ │ │ │ - blvc 5cf08 <__bss_start@@Base+0x1e68> │ │ │ │ - blvs 1dd1a0 <__bss_end__@@Base+0x136568> │ │ │ │ - blvc 19d1a4 <__bss_end__@@Base+0xf656c> │ │ │ │ - blvs 1dcedc <__bss_end__@@Base+0x1362a4> │ │ │ │ - blvc 25cee0 <__bss_end__@@Base+0x1b62a8> │ │ │ │ - blmi 6910b4 <__bss_end__@@Base+0x5ea47c> │ │ │ │ + blvc 5ce90 <__bss_start@@Base+0x1e88> │ │ │ │ + blvs 1dd128 <__bss_end__@@Base+0x136588> │ │ │ │ + blvc 19d12c <__bss_end__@@Base+0xf658c> │ │ │ │ + blvs 1dce64 <__bss_end__@@Base+0x1362c4> │ │ │ │ + blvc 25ce68 <__bss_end__@@Base+0x1b62c8> │ │ │ │ + blmi 69103c <__bss_end__@@Base+0x5ea49c> │ │ │ │ ldrbtmi r4, [fp], #-1541 @ 0xfffff9fb │ │ │ │ bicslt r6, ip, ip, lsl r8 │ │ │ │ andsvs r6, sl, r2, lsr #16 │ │ │ │ movwcs r4, #2580 @ 0xa14 │ │ │ │ biccs r6, r8, r5, rrx │ │ │ │ cdp 1, 11, cr6, cr7, cr3, {1} │ │ │ │ rscvs r6, r1, r0, lsl #22 │ │ │ │ - blpl 15d3bc <__bss_end__@@Base+0xb6784> │ │ │ │ + blpl 15d344 <__bss_end__@@Base+0xb67a4> │ │ │ │ stmib r4, {r1, r4, r5, r7, fp, ip, lr}^ │ │ │ │ ldc 3, cr3, [r2, #40] @ 0x28 │ │ │ │ vadd.f64 d7, d7, d0 │ │ │ │ vadd.f64 d6, d7, d6 │ │ │ │ vstr d7, [r4, #20] │ │ │ │ vstr d6, [r4, #24] │ │ │ │ @ instruction: 0xf8c77b08 │ │ │ │ strb r4, [r7, ip, asr #3] │ │ │ │ strtmi r4, [r3], -r9, lsl #16 │ │ │ │ cmpcs r7, r0, lsr r2 │ │ │ │ @ instruction: 0xf7f24478 │ │ │ │ - strmi pc, [r4], -r5, ror #16 │ │ │ │ + strmi pc, [r4], -sp, lsl #18 │ │ │ │ ldrbtmi r4, [r8], #-2054 @ 0xfffff7fa │ │ │ │ - blx fee5f8f6 <__bss_end__@@Base+0xfedb8cbe> │ │ │ │ + stc2l 7, cr15, [r0], #-968 @ 0xfffffc38 │ │ │ │ svclt 0x0000e7d8 │ │ │ │ - andeq r6, r3, r4, ror #14 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - andeq fp, r3, r2, lsr r1 │ │ │ │ - andeq r8, r2, r8, ror #30 │ │ │ │ + ldrdeq r6, [r3], -ip │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + andeq fp, r3, r2, lsl r1 │ │ │ │ + andeq r9, r2, r4, lsr #3 │ │ │ │ @ instruction: 0xfffffe23 │ │ │ │ andpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [ip, #128] @ 0x80 │ │ │ │ andcs fp, r0, #-1073741822 @ 0xc0000002 │ │ │ │ @ instruction: 0x4770609a │ │ │ │ andpl pc, r0, r0, lsl #10 │ │ │ │ ldrbtmi r4, [sl], #-2590 @ 0xfffff5e2 │ │ │ │ ldrdcc pc, [ip, #128] @ 0x80 │ │ │ │ ldmvs r8, {r0, r1, r5, r6, r8, r9, ip, sp, pc} │ │ │ │ ldmdami ip, {r4, r6, r8, r9, ip, sp, pc} │ │ │ │ ldrsbtgt pc, [r0], #-143 @ 0xffffff71 @ │ │ │ │ - blvs 61cfec <__bss_end__@@Base+0x5763b4> │ │ │ │ + blvs 61cf74 <__bss_end__@@Base+0x5763d4> │ │ │ │ ldmdapl r2, {r2, r3, r4, r5, r6, r7, sl, lr} │ │ │ │ - blpl dcfe8 <__bss_end__@@Base+0x363b0> │ │ │ │ - blvc 5cfc4 <__bss_start@@Base+0x1f24> │ │ │ │ + blpl dcf70 <__bss_end__@@Base+0x363d0> │ │ │ │ + blvc 5cf4c <__bss_start@@Base+0x1f44> │ │ │ │ mrc 8, 5, r6, cr4, cr10, {6} │ │ │ │ vsub.f64 d5, d23, d7 │ │ │ │ vmov.f64 d22, #22 @ 0x40b00000 5.5 │ │ │ │ vstr s30, [ip, #64] @ 0x40 │ │ │ │ svclt 0x00c86b02 │ │ │ │ ldrmi r0, [r1], #-73 @ 0xffffffb7 │ │ │ │ svclt 0x00d829c7 │ │ │ │ ldcle 1, cr2, [r0], {200} @ 0xc8 │ │ │ │ - blvs 5d47c <__bss_start@@Base+0x23dc> │ │ │ │ - blpl 15d46c <__bss_end__@@Base+0xb6834> │ │ │ │ + blvs 5d404 <__bss_start@@Base+0x23fc> │ │ │ │ + blpl 15d3f4 <__bss_end__@@Base+0xb6854> │ │ │ │ sbcsvs r2, r9, r0, lsl #4 │ │ │ │ - blvs 1dd288 <__bss_end__@@Base+0x136650> │ │ │ │ - blvc 19d28c <__bss_end__@@Base+0xf6654> │ │ │ │ + blvs 1dd210 <__bss_end__@@Base+0x136670> │ │ │ │ + blvc 19d214 <__bss_end__@@Base+0xf6674> │ │ │ │ addsvs r6, sl, #-2147483642 @ 0x80000006 │ │ │ │ - blvs 1dcfc4 <__bss_end__@@Base+0x13638c> │ │ │ │ - blvc 25cfc8 <__bss_end__@@Base+0x1b6390> │ │ │ │ + blvs 1dcf4c <__bss_end__@@Base+0x1363ac> │ │ │ │ + blvc 25cf50 <__bss_end__@@Base+0x1b63b0> │ │ │ │ vaba.s8 q10, q0, q8 │ │ │ │ addsmi r2, r1, #268435457 @ 0x10000001 │ │ │ │ ldrmi fp, [r1], -r8, lsr #31 │ │ │ │ svclt 0x0000e7e8 │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00b99999 │ │ │ │ - andeq r6, r3, r6, lsr #13 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - muleq r3, r8, r0 │ │ │ │ + andeq r6, r3, lr, lsl r7 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + andeq fp, r3, r8, ror r0 │ │ │ │ andpl pc, r0, r0, lsl #10 │ │ │ │ ldrbtmi r4, [sl], #-2583 @ 0xfffff5e9 │ │ │ │ ldrdcc pc, [ip, #128] @ 0x80 │ │ │ │ ldmvs r8, {r0, r1, r3, r5, r6, r7, r8, ip, sp, pc} │ │ │ │ ldmdami r5, {r3, r4, r6, r7, r8, ip, sp, pc} │ │ │ │ ldrsbgt pc, [r4], #-143 @ 0xffffff71 @ │ │ │ │ - blvc 45d078 <__bss_end__@@Base+0x3b6440> │ │ │ │ + blvc 45d000 <__bss_end__@@Base+0x3b6460> │ │ │ │ ldmdapl r2, {r2, r3, r4, r5, r6, r7, sl, lr} │ │ │ │ - blpl 15d074 <__bss_end__@@Base+0xb643c> │ │ │ │ - blvs 5d050 <__bss_start@@Base+0x1fb0> │ │ │ │ + blpl 15cffc <__bss_end__@@Base+0xb645c> │ │ │ │ + blvs 5cfd8 <__bss_start@@Base+0x1fd0> │ │ │ │ @ instruction: 0xeeb46ada │ │ │ │ vsub.f64 d5, d22, d6 │ │ │ │ vmov.f64 d23, #23 @ 0x40b80000 5.750 │ │ │ │ vstr s30, [ip, #64] @ 0x40 │ │ │ │ svclt 0x00c87b04 │ │ │ │ stmne r9, {r0, r3, r6} │ │ │ │ @ instruction: 0xf511d506 │ │ │ │ @@ -30979,591 +30974,591 @@ │ │ │ │ @ instruction: 0x477062d9 │ │ │ │ @ instruction: 0x71b4f5a1 │ │ │ │ svcvc 0x00b4f5b1 │ │ │ │ udf #32170 @ 0x7daa │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00b99999 │ │ │ │ - andeq r6, r3, sl, lsl r6 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - andeq fp, r3, ip │ │ │ │ + muleq r3, r2, r6 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + andeq sl, r3, ip, ror #31 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 25cf10 <__bss_end__@@Base+0x1b62d8> │ │ │ │ + blhi 25ce98 <__bss_end__@@Base+0x1b62f8> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0060f8cc │ │ │ │ addslt r4, sl, sp, lsl #21 │ │ │ │ ldrbtmi r4, [sl], #-2957 @ 0xfffff473 │ │ │ │ ldrbtmi r4, [lr], #-3725 @ 0xfffff173 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9319 │ │ │ │ @ instruction: 0xf5000300 │ │ │ │ @ instruction: 0xf8d35300 │ │ │ │ smlabtlt sp, ip, r1, r5 │ │ │ │ ldmdblt fp!, {r0, r1, r3, r5, r7, fp, sp, lr}^ │ │ │ │ - blmi fe1744a8 <__bss_end__@@Base+0xfe0cd870> │ │ │ │ + blmi fe174430 <__bss_end__@@Base+0xfe0cd890> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 67bafc <__bss_end__@@Base+0x5d4ec4> │ │ │ │ + blls 67ba84 <__bss_end__@@Base+0x5d4ee4> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ ldrshlt r8, [sl], -r7 │ │ │ │ - blhi 25cd98 <__bss_end__@@Base+0x1b6160> │ │ │ │ + blhi 25cd20 <__bss_end__@@Base+0x1b6180> │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ strmi r4, [r4], -r0, lsl #23 │ │ │ │ - blvs 1dd104 <__bss_end__@@Base+0x1364cc> │ │ │ │ + blvs 1dd08c <__bss_end__@@Base+0x1364ec> │ │ │ │ ldmpl r7!, {r6, r7, fp, sp, lr}^ │ │ │ │ - blvc 5d114 <__bss_start@@Base+0x2074> │ │ │ │ - blvs ff21d58c <__bss_end__@@Base+0xff176954> │ │ │ │ - blx 45d684 <__bss_end__@@Base+0x3b6a4c> │ │ │ │ + blvc 5d09c <__bss_start@@Base+0x2094> │ │ │ │ + blvs ff21d514 <__bss_end__@@Base+0xff176974> │ │ │ │ + blx 45d60c <__bss_end__@@Base+0x3b6a6c> │ │ │ │ addhi pc, sl, r0, asr #6 │ │ │ │ @ instruction: 0xf1046a63 │ │ │ │ ldrtmi r0, [r9], -r4, lsr #15 │ │ │ │ - blls 1c9d14c <__bss_end__@@Base+0x1bf6514> │ │ │ │ + blls 1c9d0d4 <__bss_end__@@Base+0x1bf6534> │ │ │ │ ldrdhi pc, [r4], -r3 │ │ │ │ @ instruction: 0xf7e34640 │ │ │ │ - blmi 1da00d0 <__bss_end__@@Base+0x1cf9498> │ │ │ │ + blmi 1da0078 <__bss_end__@@Base+0x1cf94d8> │ │ │ │ @ instruction: 0x46404639 │ │ │ │ @ instruction: 0x466e58f3 │ │ │ │ @ instruction: 0xf7e4881a │ │ │ │ - @ instruction: 0xf9b4f845 │ │ │ │ + @ instruction: 0xf9b4f84d │ │ │ │ @ instruction: 0xf9b420a4 │ │ │ │ cdp 0, 0, cr3, cr7, cr8, {5} │ │ │ │ @ instruction: 0xeeb32a90 │ │ │ │ @ instruction: 0xf9b45b04 │ │ │ │ - bne fe6e5d98 <__bss_end__@@Base+0xfe63f160> │ │ │ │ - bcc 45d320 <__bss_end__@@Base+0x3b66e8> │ │ │ │ - blge ffa1d5e8 <__bss_end__@@Base+0xff9769b0> │ │ │ │ - blvs 15d5cc <__bss_end__@@Base+0xb6994> │ │ │ │ - blvc ff21d5f0 <__bss_end__@@Base+0xff1769b8> │ │ │ │ - bne 45d334 <__bss_end__@@Base+0x3b66fc> │ │ │ │ + bne fe6e5d20 <__bss_end__@@Base+0xfe63f180> │ │ │ │ + bcc 45d2a8 <__bss_end__@@Base+0x3b6708> │ │ │ │ + blge ffa1d570 <__bss_end__@@Base+0xff9769d0> │ │ │ │ + blvs 15d554 <__bss_end__@@Base+0xb69b4> │ │ │ │ + blvc ff21d578 <__bss_end__@@Base+0xff1769d8> │ │ │ │ + bne 45d2bc <__bss_end__@@Base+0x3b671c> │ │ │ │ strtmi r4, [r0], -r7, ror #22 │ │ │ │ - blhi ff25d5fc <__bss_end__@@Base+0xff1b69c4> │ │ │ │ + blhi ff25d584 <__bss_end__@@Base+0xff1b69e4> │ │ │ │ stmdbmi r7!, {r1, r2, r5, r6, r9, fp, lr}^ │ │ │ │ mcr 4, 4, r4, cr7, cr11, {3} │ │ │ │ ldrbtmi fp, [sl], #-2821 @ 0xfffff4fb │ │ │ │ mcr 4, 1, r4, cr11, cr9, {3} │ │ │ │ vadd.f64 d9, d10, d9 │ │ │ │ vmov.f64 d10, #11 @ 0x40580000 3.375 │ │ │ │ vnmul.f64 d2, d9, d11 │ │ │ │ vmov.f64 d9, #6 @ 0x40300000 2.750 │ │ │ │ vsub.f64 d0, d8, d10 │ │ │ │ vmov.f64 d8, #9 @ 0x40480000 3.125 │ │ │ │ @ instruction: 0xf7ff1b48 │ │ │ │ ldmdbmi sp, {r0, r1, r2, r4, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - blhi 25d434 <__bss_end__@@Base+0x1b67fc> │ │ │ │ + blhi 25d3bc <__bss_end__@@Base+0x1b681c> │ │ │ │ ldrbtmi r6, [r9], #-2282 @ 0xfffff716 │ │ │ │ @ instruction: 0xf7e14630 │ │ │ │ - blmi 16dd0ac <__bss_end__@@Base+0x1636474> │ │ │ │ + blmi 16dd05c <__bss_end__@@Base+0x16364bc> │ │ │ │ @ instruction: 0xeeb0495a │ │ │ │ vmov.f64 d2, d11 │ │ │ │ vmov.f64 d1, d8 │ │ │ │ ldrbtmi r0, [r9], #-2890 @ 0xfffff4b6 │ │ │ │ @ instruction: 0x4632447b │ │ │ │ @ instruction: 0xf7ff4620 │ │ │ │ - bvs feaa137c <__bss_end__@@Base+0xfe9fa744> │ │ │ │ - blhi 25d460 <__bss_end__@@Base+0x1b6828> │ │ │ │ + bvs feaa1304 <__bss_end__@@Base+0xfe9fa764> │ │ │ │ + blhi 25d3e8 <__bss_end__@@Base+0x1b6848> │ │ │ │ subsle r2, r4, r0, lsl #18 │ │ │ │ @ instruction: 0xf7e14630 │ │ │ │ - svcmi 0x0051eb92 │ │ │ │ - blcs 131d64c <__bss_end__@@Base+0x1276a14> │ │ │ │ + svcmi 0x0051ebaa │ │ │ │ + blcs 131d5d4 <__bss_end__@@Base+0x1276a34> │ │ │ │ @ instruction: 0xeeb04950 │ │ │ │ - ldrbtmi r1, [pc], #-2888 @ 21b94 │ │ │ │ - bleq 12dd658 <__bss_end__@@Base+0x1236a20> │ │ │ │ + ldrbtmi r1, [pc], #-2888 @ 21b1c │ │ │ │ + bleq 12dd5e0 <__bss_end__@@Base+0x1236a40> │ │ │ │ @ instruction: 0x4632463b │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ stc2l 7, cr15, [sl, #1020]! @ 0x3fc │ │ │ │ cdp 8, 3, cr6, cr9, cr11, {5} │ │ │ │ cmnlt fp, #8, 22 @ 0x2000 │ │ │ │ - blcs 3c05c │ │ │ │ - bvs feb15cdc <__bss_end__@@Base+0xfea6f0a4> │ │ │ │ + blcs 3bfe4 │ │ │ │ + bvs feb15c64 <__bss_end__@@Base+0xfea6f0c4> │ │ │ │ suble r2, r0, r0, lsl #22 │ │ │ │ - bmi 11f48d4 <__bss_end__@@Base+0x114dc9c> │ │ │ │ + bmi 11f485c <__bss_end__@@Base+0x114dcbc> │ │ │ │ ldrbtmi r4, [fp], #-2375 @ 0xfffff6b9 │ │ │ │ ldrbtmi r4, [r9], #-1146 @ 0xfffffb86 │ │ │ │ - blcs 131d688 <__bss_end__@@Base+0x1276a50> │ │ │ │ - blne 129d68c <__bss_end__@@Base+0x11f6a54> │ │ │ │ - bleq 12dd690 <__bss_end__@@Base+0x1236a58> │ │ │ │ + blcs 131d610 <__bss_end__@@Base+0x1276a70> │ │ │ │ + blne 129d614 <__bss_end__@@Base+0x11f6a74> │ │ │ │ + bleq 12dd618 <__bss_end__@@Base+0x1236a78> │ │ │ │ @ instruction: 0xf7ff4620 │ │ │ │ smmls r7, r1, sp, pc @ │ │ │ │ - blvs 5d6b8 <__bss_start@@Base+0x2618> │ │ │ │ + blvs 5d640 <__bss_start@@Base+0x2638> │ │ │ │ cdp 8, 3, cr6, cr7, cr9, {7} │ │ │ │ vstr d7, [r5, #24] │ │ │ │ @ instruction: 0xf0197b06 │ │ │ │ stmdacs r0, {r0, r3, r4, r5, r6, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ stmdbvs fp!, {r0, r1, r4, r5, ip, lr, pc} │ │ │ │ mlasle fp, r8, r2, r4 │ │ │ │ - blvc 5d254 <__bss_start@@Base+0x21b4> │ │ │ │ - blvs 15d6c4 <__bss_end__@@Base+0xb6a8c> │ │ │ │ + blvc 5d1dc <__bss_start@@Base+0x21d4> │ │ │ │ + blvs 15d64c <__bss_end__@@Base+0xb6aac> │ │ │ │ @ instruction: 0x61282300 │ │ │ │ cdp 2, 3, cr6, cr7, cr11, {5} │ │ │ │ vstr d7, [r5, #24] │ │ │ │ ldrb r7, [fp, -r8, lsl #22] │ │ │ │ @ instruction: 0xeeb04a34 │ │ │ │ ldmdbmi r4!, {r0, r1, r3, r6, r8, r9, fp, sp} │ │ │ │ - blne 129d6d8 <__bss_end__@@Base+0x11f6aa0> │ │ │ │ - bleq 12dd6dc <__bss_end__@@Base+0x1236aa4> │ │ │ │ + blne 129d660 <__bss_end__@@Base+0x11f6ac0> │ │ │ │ + bleq 12dd664 <__bss_end__@@Base+0x1236ac4> │ │ │ │ ldrbtmi r4, [r9], #-1146 @ 0xfffffb86 │ │ │ │ @ instruction: 0x4620463b │ │ │ │ stc2 7, cr15, [r8, #1020]! @ 0x3fc │ │ │ │ - blmi c1bb2c <__bss_end__@@Base+0xb74ef4> │ │ │ │ + blmi c1bab4 <__bss_end__@@Base+0xb74f14> │ │ │ │ ldm r3, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ andls r0, r0, r3 │ │ │ │ andne pc, r4, sp, lsl #17 │ │ │ │ - blmi b5bad0 <__bss_end__@@Base+0xab4e98> │ │ │ │ + blmi b5ba58 <__bss_end__@@Base+0xab4eb8> │ │ │ │ pushmi {r2, r3, r5, r9, fp, lr} │ │ │ │ ldrbtmi r4, [sl], #-1147 @ 0xfffffb85 │ │ │ │ @ instruction: 0xe7bd4479 │ │ │ │ - bmi b348f8 <__bss_end__@@Base+0xa8dcc0> │ │ │ │ + bmi b34880 <__bss_end__@@Base+0xa8dce0> │ │ │ │ ldrbtmi r4, [fp], #-2348 @ 0xfffff6d4 │ │ │ │ ldrbtmi r4, [r9], #-1146 @ 0xfffffb86 │ │ │ │ ldc 7, cr14, [r7, #728] @ 0x2d8 │ │ │ │ vmov.f64 d7, #32 @ 0x41000000 8.0 │ │ │ │ @ instruction: 0x61286b04 │ │ │ │ cdp 2, 3, cr6, cr7, cr8, {5} │ │ │ │ vstr d7, [r5, #24] │ │ │ │ str r7, [fp, -r8, lsl #22]! │ │ │ │ - blcs 3c71c │ │ │ │ + blcs 3c6a4 │ │ │ │ svcge 0x0028f47f │ │ │ │ - blvs 25d2cc <__bss_end__@@Base+0x1b6694> │ │ │ │ - blvc 5d2d8 <__bss_start@@Base+0x2238> │ │ │ │ - blvs ff21d750 <__bss_end__@@Base+0xff176b18> │ │ │ │ - blx 45d848 <__bss_end__@@Base+0x3b6c10> │ │ │ │ + blvs 25d254 <__bss_end__@@Base+0x1b66b4> │ │ │ │ + blvc 5d260 <__bss_start@@Base+0x2258> │ │ │ │ + blvs ff21d6d8 <__bss_end__@@Base+0xff176b38> │ │ │ │ + blx 45d7d0 <__bss_end__@@Base+0x3b6c30> │ │ │ │ andcc fp, lr, r4, asr #30 │ │ │ │ ldr r6, [fp, -r8, lsr #5] │ │ │ │ - bl fe5dfc14 <__bss_end__@@Base+0xfe538fdc> │ │ │ │ + bl febdfb9c <__bss_end__@@Base+0xfeb38ffc> │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ teqcc r3, #-872415232 @ 0xcc000000 │ │ │ │ svccc 0x00f33333 │ │ │ │ - muleq r3, r6, r5 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - muleq r3, r2, r5 │ │ │ │ - andeq r6, r3, r4, ror r5 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ + andeq r6, r3, lr, lsl #12 │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq r9, r2, r4, lsr #2 │ │ │ │ - andeq r8, r2, r6, ror #26 │ │ │ │ - andeq r8, r2, r8, ror #26 │ │ │ │ - andeq r9, r2, lr, ror #2 │ │ │ │ - andeq r8, r2, ip, lsr #26 │ │ │ │ - andeq r8, r2, r2, lsr sp │ │ │ │ - strheq r9, [r2], -r2 │ │ │ │ - andeq r8, r2, sl, lsl #26 │ │ │ │ - andeq r9, r2, r6, lsl #1 │ │ │ │ - strdeq r8, [r2], -ip │ │ │ │ - andeq r8, r2, lr, ror #25 │ │ │ │ - muleq r2, r0, ip │ │ │ │ - muleq r2, r2, ip │ │ │ │ - andeq r8, r2, r4, ror ip │ │ │ │ - andeq r9, r2, r4 │ │ │ │ - andeq r7, r2, r6, lsr #27 │ │ │ │ - andeq r8, r2, ip, ror #24 │ │ │ │ - strdeq r8, [r2], -r6 │ │ │ │ - andeq r8, r2, r4, ror #24 │ │ │ │ - andeq r8, r2, lr, asr ip │ │ │ │ + andeq r6, r3, sl, lsl #12 │ │ │ │ + andeq r6, r3, ip, ror #11 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + andeq r0, r0, r8, asr #5 │ │ │ │ + andeq r9, r2, r0, ror #6 │ │ │ │ + andeq r8, r2, r2, lsr #31 │ │ │ │ + andeq r8, r2, r4, lsr #31 │ │ │ │ + andeq r9, r2, sl, lsr #7 │ │ │ │ + andeq r8, r2, r8, ror #30 │ │ │ │ + andeq r8, r2, lr, ror #30 │ │ │ │ + andeq r9, r2, lr, ror #5 │ │ │ │ + andeq r8, r2, r6, asr #30 │ │ │ │ + andeq r9, r2, r2, asr #5 │ │ │ │ + andeq r8, r2, r8, lsr pc │ │ │ │ + andeq r8, r2, sl, lsr #30 │ │ │ │ + andeq r8, r2, ip, asr #29 │ │ │ │ + andeq r8, r2, lr, asr #29 │ │ │ │ + @ instruction: 0x00028eb0 │ │ │ │ + andeq r9, r2, r0, asr #4 │ │ │ │ + muleq r2, lr, sp │ │ │ │ + andeq r8, r2, r8, lsr #29 │ │ │ │ + andeq r9, r2, r2, lsr r2 │ │ │ │ + andeq r8, r2, r0, lsr #29 │ │ │ │ + muleq r2, sl, lr │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 2dd1c4 <__bss_end__@@Base+0x23658c> │ │ │ │ + blhi 2dd14c <__bss_end__@@Base+0x2365ac> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0000f8cc │ │ │ │ ldrdlt r4, [sp], sl @ │ │ │ │ ldrbtmi r4, [sl], #-3034 @ 0xfffff426 │ │ │ │ msrhi SPSR_f, #14614528 @ 0xdf0000 │ │ │ │ ldmpl r3, {r3, r4, r5, r6, r7, sl, lr}^ │ │ │ │ @ instruction: 0x932b681b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwpl pc, #1280 @ 0x500 @ │ │ │ │ ldrdvs pc, [ip, #131] @ 0x83 │ │ │ │ ldmvs r3!, {r1, r2, r3, r8, ip, sp, pc} │ │ │ │ - bmi ff55032c <__bss_end__@@Base+0xff4a96f4> │ │ │ │ + bmi ff5502b4 <__bss_end__@@Base+0xff4a9714> │ │ │ │ ldrbtmi r4, [sl], #-3025 @ 0xfffff42f │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, fp, lsr #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ msrhi SPSR_fs, r0, asr #32 │ │ │ │ ldc 0, cr11, [sp], #180 @ 0xb4 │ │ │ │ pop {r1, r3, r8, r9, fp, pc} │ │ │ │ - bvs 1105d20 <__bss_end__@@Base+0x105f0e8> │ │ │ │ + bvs 1105ca8 <__bss_end__@@Base+0x105f108> │ │ │ │ strteq pc, [ip], #256 @ 0x100 │ │ │ │ strtmi r4, [r1], -r5, lsl #12 │ │ │ │ - bllt 5d844 <__bss_start@@Base+0x27a4> │ │ │ │ - blhi fed1d3ec <__bss_end__@@Base+0xfec767b4> │ │ │ │ + bllt 5d7cc <__bss_start@@Base+0x27c4> │ │ │ │ + blhi fed1d374 <__bss_end__@@Base+0xfec767d4> │ │ │ │ mrc 8, 5, r6, cr0, cr15, {2} │ │ │ │ ldrtmi r9, [r8], -fp, asr #22 │ │ │ │ - @ instruction: 0xf82cf7e3 │ │ │ │ + @ instruction: 0xf834f7e3 │ │ │ │ strtmi r4, [r1], -r5, asr #23 │ │ │ │ @ instruction: 0xf8584638 │ │ │ │ ldmdahi sl, {r0, r1, ip, sp} │ │ │ │ - cdp2 7, 15, cr15, cr4, cr3, {7} │ │ │ │ + cdp2 7, 15, cr15, cr12, cr3, {7} │ │ │ │ @ instruction: 0xf9b54bc2 │ │ │ │ stmiavs r8!, {r2, r3, r5, r7, ip, sp, pc}^ │ │ │ │ strhtmi pc, [lr], r5 @ │ │ │ │ andls pc, r3, r8, asr r8 @ │ │ │ │ ldrhtcc pc, [r0], r5 @ │ │ │ │ movweq lr, #48035 @ 0xbba3 │ │ │ │ - bcc fe45d5c4 <__bss_end__@@Base+0xfe3b698c> │ │ │ │ + bcc fe45d54c <__bss_end__@@Base+0xfe3b69ac> │ │ │ │ orrpl pc, r0, #0, 10 │ │ │ │ @ instruction: 0xa000f8b9 │ │ │ │ - blge ffa1d894 <__bss_end__@@Base+0xff976c5c> │ │ │ │ + blge ffa1d81c <__bss_end__@@Base+0xff976c7c> │ │ │ │ ldrdcs pc, [ip], r3 @ │ │ │ │ - blls 31d5e4 <__bss_end__@@Base+0x2769ac> │ │ │ │ - blhi 25d668 <__bss_end__@@Base+0x1b6a30> │ │ │ │ - blvc ff29d9b8 <__bss_end__@@Base+0xff1f6d80> │ │ │ │ - bcc fe45d624 <__bss_end__@@Base+0xfe3b69ec> │ │ │ │ + blls 31d56c <__bss_end__@@Base+0x2769cc> │ │ │ │ + blhi 25d5f0 <__bss_end__@@Base+0x1b6a50> │ │ │ │ + blvc ff29d940 <__bss_end__@@Base+0xff1f6da0> │ │ │ │ + bcc fe45d5ac <__bss_end__@@Base+0xfe3b6a0c> │ │ │ │ tsteq fp, r3, lsl #22 │ │ │ │ cdp 4, 0, cr4, cr9, cr3, {1} │ │ │ │ vmov s19, r1 │ │ │ │ - bcs 30618 │ │ │ │ + bcs 305a0 │ │ │ │ tstphi r0, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ - blmi fe69d45c <__bss_end__@@Base+0xfe5f6824> │ │ │ │ - blvs 131d8a4 <__bss_end__@@Base+0x1276c6c> │ │ │ │ - blvc fe69d464 <__bss_end__@@Base+0xfe5f682c> │ │ │ │ - blpl fe6dd468 <__bss_end__@@Base+0xfe636830> │ │ │ │ - blvs 15d618 <__bss_end__@@Base+0xb69e0> │ │ │ │ + blmi fe69d3e4 <__bss_end__@@Base+0xfe5f6844> │ │ │ │ + blvs 131d82c <__bss_end__@@Base+0x1276c8c> │ │ │ │ + blvc fe69d3ec <__bss_end__@@Base+0xfe5f684c> │ │ │ │ + blpl fe6dd3f0 <__bss_end__@@Base+0xfe636850> │ │ │ │ + blvs 15d5a0 <__bss_end__@@Base+0xb6a00> │ │ │ │ vmul.f64 d4, d26, d26 │ │ │ │ vldr d7, [r0, #28] │ │ │ │ vmov.16 d10[1], ip │ │ │ │ - bvs 1a50a14 <__bss_end__@@Base+0x19a9ddc> │ │ │ │ + bvs 1a5099c <__bss_end__@@Base+0x19a9dfc> │ │ │ │ mrc 4, 5, r4, cr13, cr11, {3} │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vnmla.f64 d6, d23, d6 │ │ │ │ @ instruction: 0xeebd2a10 │ │ │ │ vnmla.f64 d11, d22, d11 │ │ │ │ strtmi r1, [r2], #-2704 @ 0xfffff570 │ │ │ │ strcs r4, [r2], #-1113 @ 0xfffffba7 │ │ │ │ - blt 9d454 <__bss_start@@Base+0x423b4> │ │ │ │ + blt 9d3dc <__bss_start@@Base+0x423d4> │ │ │ │ stcge 4, cr9, [sl], {-0} │ │ │ │ andge pc, r8, sp, asr #17 │ │ │ │ - @ instruction: 0xf848f7e8 │ │ │ │ + @ instruction: 0xffe8f7e7 │ │ │ │ @ instruction: 0xf7e84620 │ │ │ │ - tstpcs r3, r1, asr #30 @ p-variant is OBSOLETE │ │ │ │ - bleq 135d8fc <__bss_end__@@Base+0x12b6cc4> │ │ │ │ + tstpcs r3, r1, ror pc @ p-variant is OBSOLETE │ │ │ │ + bleq 135d884 <__bss_end__@@Base+0x12b6ce4> │ │ │ │ @ instruction: 0xf7e94620 │ │ │ │ - cdp 8, 11, cr15, cr0, cr1, {5} │ │ │ │ + mrc 8, 5, APSR_nzcv, cr0, cr6, {7} │ │ │ │ vmov.f64 d2, d8 │ │ │ │ vmov.f64 d1, d8 │ │ │ │ strtmi r0, [r0], -r8, asr #22 │ │ │ │ - bllt fe11d4cc <__bss_end__@@Base+0xfe076894> │ │ │ │ - @ instruction: 0xf998f7e9 │ │ │ │ - blge ffa9d938 <__bss_end__@@Base+0xff9f6d00> │ │ │ │ - blls ff29d93c <__bss_end__@@Base+0xff1f6d04> │ │ │ │ - blcs 5d95c <__bss_start@@Base+0x28bc> │ │ │ │ + bllt fe11d454 <__bss_end__@@Base+0xfe0768b4> │ │ │ │ + blx 15dfd80 <__bss_end__@@Base+0x15391e0> │ │ │ │ + blge ffa9d8c0 <__bss_end__@@Base+0xff9f6d20> │ │ │ │ + blls ff29d8c4 <__bss_end__@@Base+0xff1f6d24> │ │ │ │ + blcs 5d8e4 <__bss_start@@Base+0x28dc> │ │ │ │ cdp 6, 11, cr4, cr0, cr0, {1} │ │ │ │ vmov.f64 d0, d10 │ │ │ │ @ instruction: 0xf7e91b49 │ │ │ │ - @ instruction: 0xf024f9e9 │ │ │ │ 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│ - mrc 14, 5, APSR_nzcv, cr5, cr9, {7} │ │ │ │ - vldr d2, [pc] @ 21ec8 │ │ │ │ + cdp 15, 11, cr15, cr5, cr9, {1} │ │ │ │ + vldr d2, [pc] @ 21e50 │ │ │ │ strtmi r1, [r0], -r9, ror #22 │ │ │ │ - blcs dd770 <__bss_end__@@Base+0x36b38> │ │ │ │ - blne 9d774 <__bss_start@@Base+0x426d4> │ │ │ │ - bleq 10dd998 <__bss_end__@@Base+0x1036d60> │ │ │ │ - @ instruction: 0xf954f7e9 │ │ │ │ - blne 129d9a0 <__bss_end__@@Base+0x11f6d68> │ │ │ │ - blcs 5d9e0 <__bss_start@@Base+0x2940> │ │ │ │ - bleq 12dd9a8 <__bss_end__@@Base+0x1236d70> │ │ │ │ + blcs dd6f8 <__bss_end__@@Base+0x36b58> │ │ │ │ + blne 9d6fc <__bss_start@@Base+0x426f4> │ │ │ │ + bleq 10dd920 <__bss_end__@@Base+0x1036d80> │ │ │ │ + blx 4dfe08 <__bss_end__@@Base+0x439268> │ │ │ │ + blne 129d928 <__bss_end__@@Base+0x11f6d88> │ │ │ │ + blcs 5d968 <__bss_start@@Base+0x2960> │ │ │ │ + bleq 12dd930 <__bss_end__@@Base+0x1236d90> │ │ │ │ @ instruction: 0xf7e94620 │ │ │ │ - @ instruction: 0xf024f9a9 │ │ │ │ + @ instruction: 0xf024fa63 │ │ │ │ @ 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│ - blcs dd84c <__bss_end__@@Base+0x36c14> │ │ │ │ - blne 10dda70 <__bss_end__@@Base+0x1036e38> │ │ │ │ - bleq 10dda74 <__bss_end__@@Base+0x1036e3c> │ │ │ │ - @ instruction: 0xf8e6f7e9 │ │ │ │ - blne 129da7c <__bss_end__@@Base+0x11f6e44> │ │ │ │ - bleq 12dda80 <__bss_end__@@Base+0x1236e48> │ │ │ │ + blcs dd7d4 <__bss_end__@@Base+0x36c34> │ │ │ │ + blne 10dd9f8 <__bss_end__@@Base+0x1036e58> │ │ │ │ + bleq 10dd9fc <__bss_end__@@Base+0x1036e5c> │ │ │ │ + @ instruction: 0xf9a4f7e9 │ │ │ │ + blne 129da04 <__bss_end__@@Base+0x11f6e64> │ │ │ │ + bleq 12dda08 <__bss_end__@@Base+0x1236e68> │ │ │ │ cdp 6, 11, cr4, cr15, cr0, {1} │ │ │ │ @ instruction: 0xf7e92b00 │ │ │ │ - @ instruction: 0xf024f93b │ │ │ │ + @ instruction: 0xf024f9f5 │ │ │ │ @ instruction: 0xf8b9fb27 │ │ │ │ ldrtmi r3, [sl], -r0 │ │ │ │ @ instruction: 0xf0234621 │ │ │ │ @ instruction: 0xe6b0fef7 │ │ │ │ @ instruction: 0xf816f01e │ │ │ │ - blmi 65d660 <__bss_end__@@Base+0x5b6a28> │ │ │ │ - blvs 131daa8 <__bss_end__@@Base+0x1276e70> │ │ │ │ - blvc 65d668 <__bss_end__@@Base+0x5b6a30> │ │ │ │ - blpl 69d66c <__bss_end__@@Base+0x5f6a34> │ │ │ │ - blgt 105dab4 <__bss_end__@@Base+0xfb6e7c> │ │ │ │ - blvs 15d820 <__bss_end__@@Base+0xb6be8> │ │ │ │ + blmi 65d5e8 <__bss_end__@@Base+0x5b6a48> │ │ │ │ + blvs 131da30 <__bss_end__@@Base+0x1276e90> │ │ │ │ + blvc 65d5f0 <__bss_end__@@Base+0x5b6a50> │ │ │ │ + blpl 69d5f4 <__bss_end__@@Base+0x5f6a54> │ │ │ │ + blgt 105da3c <__bss_end__@@Base+0xfb6e9c> │ │ │ │ + blvs 15d7a8 <__bss_end__@@Base+0xb6c08> │ │ │ │ cdp 8, 2, cr6, cr10, cr11, {7} │ │ │ │ - bvs 1a40c1c <__bss_end__@@Base+0x1999fe4> │ │ │ │ - bllt 19d82c <__bss_end__@@Base+0xf6bf4> │ │ │ │ + bvs 1a40ba4 <__bss_end__@@Base+0x199a004> │ │ │ │ + bllt 19d7b4 <__bss_end__@@Base+0xf6c14> │ │ │ │ orrpl pc, r0, #12582912 @ 0xc00000 │ │ │ │ - blvc ff21db00 <__bss_end__@@Base+0xff176ec8> │ │ │ │ + blvc ff21da88 <__bss_end__@@Base+0xff176ee8> │ │ │ │ ldrdcc pc, [ip], r3 @ │ │ │ │ - blvs ff1ddc08 <__bss_end__@@Base+0xff136fd0> │ │ │ │ - bcs 45d874 <__bss_end__@@Base+0x3b6c3c> │ │ │ │ - bllt ff31db10 <__bss_end__@@Base+0xff276ed8> │ │ │ │ - bne fe45d878 <__bss_end__@@Base+0xfe3b6c40> │ │ │ │ + blvs ff1ddb90 <__bss_end__@@Base+0xff136ff0> │ │ │ │ + bcs 45d7fc <__bss_end__@@Base+0x3b6c5c> │ │ │ │ + bllt ff31da98 <__bss_end__@@Base+0xff276ef8> │ │ │ │ + bne fe45d800 <__bss_end__@@Base+0xfe3b6c60> │ │ │ │ ldrbmi r4, [r9], #-1058 @ 0xfffffbde │ │ │ │ - blmi 80e4b4 <__bss_end__@@Base+0x76787c> │ │ │ │ + blmi 80e43c <__bss_end__@@Base+0x76789c> │ │ │ │ uxtah r4, r6, fp, ror #8 │ │ │ │ - stmib r6, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmib lr, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [fp], #-2845 @ 0xfffff4e3 │ │ │ │ svclt 0x0000e6f1 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ addgt r5, pc, #10496 @ 0x2900 │ │ │ │ svccc 0x00dc28f5 │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00a99999 │ │ │ │ - bl fe169b30 <__bss_end__@@Base+0xfe0c2ef8> │ │ │ │ + bl fe169ab8 <__bss_end__@@Base+0xfe0c2f18> │ │ │ │ svccc 0x00aeb851 │ │ │ │ adcvc sp, r3, sl, lsl #14 │ │ │ │ svccc 0x00a70a3d │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ svccc 0x00f921fb │ │ │ │ stclgt 12, cr12, [ip], {205} @ 0xcd │ │ │ │ svccc 0x00eccccc │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00c99999 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ - andeq r6, r3, r2, ror #5 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - ldrdeq r6, [r3], -ip │ │ │ │ - @ instruction: 0x000362be │ │ │ │ + andeq r6, r3, sl, asr r3 │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq r0, r0, r0, ror r2 │ │ │ │ - andeq r8, r2, r8, asr #21 │ │ │ │ - andeq r0, r0, r0, ror #5 │ │ │ │ - muleq r2, ip, r8 │ │ │ │ - muleq r2, r6, r8 │ │ │ │ - blmi f38b8 <__bss_end__@@Base+0x4cc80> │ │ │ │ + andeq r6, r3, r4, asr r3 │ │ │ │ + andeq r6, r3, r6, lsr r3 │ │ │ │ + andeq r0, r0, r8, asr #5 │ │ │ │ + andeq r0, r0, r8, ror #4 │ │ │ │ + andeq r8, r2, r4, lsl #26 │ │ │ │ + ldrdeq r0, [r0], -r8 │ │ │ │ + ldrdeq r8, [r2], -r8 @ │ │ │ │ + ldrdeq r8, [r2], -r2 │ │ │ │ + blmi f3840 <__bss_end__@@Base+0x4cca0> │ │ │ │ ldrbtmi r2, [fp], #-1 │ │ │ │ @ instruction: 0xf8436812 │ │ │ │ ldrbmi r0, [r0, -r2, lsr #32]! │ │ │ │ - andeq sl, r3, lr, ror #18 │ │ │ │ + andeq sl, r3, lr, asr #18 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb84cd4 <__bss_end__@@Base+0xfeade09c> │ │ │ │ + bl feb84c5c <__bss_end__@@Base+0xfeade0bc> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ strmi r0, [sp], -r8, asr #31 │ │ │ │ - bmi fe1346e4 <__bss_end__@@Base+0xfe08daac> │ │ │ │ + bmi fe13466c <__bss_end__@@Base+0xfe08dacc> │ │ │ │ ldrbtmi r4, [r9], #-1540 @ 0xfffff9fc │ │ │ │ - blmi fe10e2fc <__bss_end__@@Base+0xfe0676c4> │ │ │ │ + blmi fe10e284 <__bss_end__@@Base+0xfe0676e4> │ │ │ │ cdpge 0, 0, cr2, cr1, cr3, {0} │ │ │ │ ldrbtmi r5, [fp], #-2186 @ 0xfffff776 │ │ │ │ andls r6, r5, #1179648 @ 0x120000 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ - bl fc17c <__bss_end__@@Base+0x55544> │ │ │ │ + bl fc104 <__bss_end__@@Base+0x55564> │ │ │ │ @ instruction: 0xf8d30382 │ │ │ │ @ instruction: 0xf0247080 │ │ │ │ ldmdbmi ip!, {r0, r3, r5, r6, r7, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ ldrtmi r4, [sl], -r3, lsl #12 │ │ │ │ ldrbtmi r4, [r9], #-1584 @ 0xfffff9d0 │ │ │ │ - b 1ee0090 <__bss_end__@@Base+0x1e39458> │ │ │ │ + b fe160018 <__bss_end__@@Base+0xfe0b9478> │ │ │ │ @ instruction: 0xf8d44631 │ │ │ │ @ instruction: 0xf7e10f60 │ │ │ │ - @ instruction: 0xf9b4e8ca │ │ │ │ + @ instruction: 0xf9b4e8e2 │ │ │ │ @ instruction: 0xf1047338 │ │ │ │ @ instruction: 0xf7e800c8 │ │ │ │ - ldc 13, cr15, [r5, #124] @ 0x7c │ │ │ │ + ldc 12, cr15, [r5, #932] @ 0x3a4 │ │ │ │ vldr d6, [r4, #480] @ 0x1e0 │ │ │ │ svccs 0x00007b48 │ │ │ │ - blpl 3dd784 <__bss_end__@@Base+0x336b4c> │ │ │ │ - blcc 1bdd788 <__bss_end__@@Base+0x1b36b50> │ │ │ │ - blmi 1d5d78c <__bss_end__@@Base+0x1cb6b54> │ │ │ │ + blpl 3dd70c <__bss_end__@@Base+0x336b6c> │ │ │ │ + blcc 1bdd710 <__bss_end__@@Base+0x1b36b70> │ │ │ │ + blmi 1d5d714 <__bss_end__@@Base+0x1cb6b74> │ │ │ │ @ instruction: 0xeeb6db58 │ │ │ │ vadd.f64 d2, d3, d0 │ │ │ │ - vldr d3, [pc, #16] @ 22154 │ │ │ │ + vldr d3, [pc, #16] @ 220dc │ │ │ │ vnmul.f64 d4, d7, d20 │ │ │ │ vmul.f64 d7, d7, d2 │ │ │ │ vmul.f64 d7, d7, d5 │ │ │ │ vmla.f64 d7, d7, d0 │ │ │ │ @ instruction: 0xee866b40 │ │ │ │ vmul.f64 d7, d7, d3 │ │ │ │ vmov.f64 d7, #84 @ 0x3ea00000 0.3125000 │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ - blle 3e09a8 <__bss_end__@@Base+0x339d70> │ │ │ │ - blcc 21da48 <__bss_end__@@Base+0x176e10> │ │ │ │ - blvs ff4dd7c0 <__bss_end__@@Base+0xff436b88> │ │ │ │ - blmi ff45d7c4 <__bss_end__@@Base+0xff3b6b8c> │ │ │ │ - blpl 1dda10 <__bss_end__@@Base+0x136dd8> │ │ │ │ - blpl 15d988 <__bss_end__@@Base+0xb6d50> │ │ │ │ - blpl ff05dc54 <__bss_end__@@Base+0xfefb701c> │ │ │ │ - blx 45dd48 <__bss_end__@@Base+0x3b7110> │ │ │ │ - blmi 1719294 <__bss_end__@@Base+0x167265c> │ │ │ │ - blhi 5dc88 <__bss_start@@Base+0x2be8> │ │ │ │ + blle 3e0930 <__bss_end__@@Base+0x339d90> │ │ │ │ + blcc 21d9d0 <__bss_end__@@Base+0x176e30> │ │ │ │ + blvs ff4dd748 <__bss_end__@@Base+0xff436ba8> │ │ │ │ + blmi ff45d74c <__bss_end__@@Base+0xff3b6bac> │ │ │ │ + blpl 1dd998 <__bss_end__@@Base+0x136df8> │ │ │ │ + blpl 15d910 <__bss_end__@@Base+0xb6d70> │ │ │ │ + blpl ff05dbdc <__bss_end__@@Base+0xfefb703c> │ │ │ │ + blx 45dcd0 <__bss_end__@@Base+0x3b7130> │ │ │ │ + blmi 171921c <__bss_end__@@Base+0x167267c> │ │ │ │ + blhi 5dc10 <__bss_start@@Base+0x2c08> │ │ │ │ ldm r3, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ stm r6, {r0, r1, r2} │ │ │ │ @ instruction: 0xf8d40007 │ │ │ │ shsaxmi r0, r1, ip │ │ │ │ - stm r4, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldm ip, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ svccc 0x0064f8d4 │ │ │ │ andsvc r2, sl, r0, lsl #4 │ │ │ │ - blvc ff1dd800 <__bss_end__@@Base+0xff136bc8> │ │ │ │ - blvs 5dc88 <__bss_start@@Base+0x2be8> │ │ │ │ - blvc 1dda90 <__bss_end__@@Base+0x136e58> │ │ │ │ - blvc ff25dc88 <__bss_end__@@Base+0xff1b7050> │ │ │ │ - blx 45dd80 <__bss_end__@@Base+0x3b7148> │ │ │ │ - ldc 8, cr13, [pc, #148] @ 22254 │ │ │ │ + blvc ff1dd788 <__bss_end__@@Base+0xff136be8> │ │ │ │ + blvs 5dc10 <__bss_start@@Base+0x2c08> │ │ │ │ + blvc 1dda18 <__bss_end__@@Base+0x136e78> │ │ │ │ + blvc ff25dc10 <__bss_end__@@Base+0xff1b7070> │ │ │ │ + blx 45dd08 <__bss_end__@@Base+0x3b7168> │ │ │ │ + ldc 8, cr13, [pc, #148] @ 221dc │ │ │ │ vcmp.f64 d7, d7 │ │ │ │ vsqrt.f64 d24, d7 │ │ │ │ svclt 0x0094fa10 │ │ │ │ andcs r2, r0, r1 │ │ │ │ - blmi 1174af8 <__bss_end__@@Base+0x10cdec0> │ │ │ │ + blmi 1174a80 <__bss_end__@@Base+0x10cdee0> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 17c244 <__bss_end__@@Base+0xd560c> │ │ │ │ + blls 17c1cc <__bss_end__@@Base+0xd562c> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ cmnle r2, r0, lsl #6 │ │ │ │ ldc 0, cr11, [sp], #28 │ │ │ │ @ instruction: 0xbdf08b02 │ │ │ │ ldrbtmi r4, [fp], #-2883 @ 0xfffff4bd │ │ │ │ muleq r7, r3, r8 │ │ │ │ andeq lr, r7, r6, lsl #17 │ │ │ │ svceq 0x005cf8d4 │ │ │ │ @ instruction: 0xf7e14631 │ │ │ │ - @ instruction: 0xf8d4e854 │ │ │ │ + @ instruction: 0xf8d4e86c │ │ │ │ andcs r3, r0, #100, 30 @ 0x190 │ │ │ │ andcs r7, r0, sl, lsl r0 │ │ │ │ cdp 7, 11, cr14, cr1, cr0, {7} │ │ │ │ vsqrt.f64 d4, d5 │ │ │ │ vsub.f64 d5, d4, d6 │ │ │ │ vsub.f64 d6, d5, d6 │ │ │ │ @ instruction: 0xee865b44 │ │ │ │ vdiv.f64 d8, d5, d7 │ │ │ │ vmov.f64 d6, #87 @ 0x3eb80000 0.3593750 │ │ │ │ vsqrt.f64 d24, d0 │ │ │ │ mrc 10, 5, APSR_nzcv, cr5, cr0, {0} │ │ │ │ - blle efd134 <__bss_end__@@Base+0xe564fc> │ │ │ │ - blx 45ddfc <__bss_end__@@Base+0x3b71c4> │ │ │ │ + blle efd0bc <__bss_end__@@Base+0xe5651c> │ │ │ │ + blx 45dd84 <__bss_end__@@Base+0x3b71e4> │ │ │ │ vmov.f64 d13, #70 @ 0x3e300000 0.1718750 │ │ │ │ vsqrt.f64 d24, d6 │ │ │ │ svclt 0x0058fa10 │ │ │ │ - blhi 11ddd08 <__bss_end__@@Base+0x11370d0> │ │ │ │ - blvs ff1dd8a0 <__bss_end__@@Base+0xff136c68> │ │ │ │ - blpl 5dd28 <__bss_start@@Base+0x2c88> │ │ │ │ - blvc 19db34 <__bss_end__@@Base+0xf6efc> │ │ │ │ - blvs 19db30 <__bss_end__@@Base+0xf6ef8> │ │ │ │ - blvc ff21dd50 <__bss_end__@@Base+0xff177118> │ │ │ │ - blvs ff25dd30 <__bss_end__@@Base+0xff1b70f8> │ │ │ │ - blvs 7dd8e0 <__bss_end__@@Base+0x736ca8> │ │ │ │ - blx 45de2c <__bss_end__@@Base+0x3b71f4> │ │ │ │ - blhi ff1ddd3c <__bss_end__@@Base+0xff137104> │ │ │ │ + blhi 11ddc90 <__bss_end__@@Base+0x11370f0> │ │ │ │ + blvs ff1dd828 <__bss_end__@@Base+0xff136c88> │ │ │ │ + blpl 5dcb0 <__bss_start@@Base+0x2ca8> │ │ │ │ + blvc 19dabc <__bss_end__@@Base+0xf6f1c> │ │ │ │ + blvs 19dab8 <__bss_end__@@Base+0xf6f18> │ │ │ │ + blvc ff21dcd8 <__bss_end__@@Base+0xff177138> │ │ │ │ + blvs ff25dcb8 <__bss_end__@@Base+0xff1b7118> │ │ │ │ + blvs 7dd868 <__bss_end__@@Base+0x736cc8> │ │ │ │ + blx 45ddb4 <__bss_end__@@Base+0x3b7214> │ │ │ │ + blhi ff1ddcc4 <__bss_end__@@Base+0xff137124> │ │ │ │ mrc 8, 7, sp, cr1, cr3, {0} │ │ │ │ stmdble r2!, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xee174922 │ │ │ │ @ instruction: 0x46302a10 │ │ │ │ @ instruction: 0xf7e14479 │ │ │ │ - @ instruction: 0xf8d4e9c0 │ │ │ │ + @ instruction: 0xf8d4e9ca │ │ │ │ shsaxmi r0, r1, ip │ │ │ │ - stmda lr, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda r6!, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ svccc 0x0064f8d4 │ │ │ │ andsvc r2, sl, r0, lsl #4 │ │ │ │ cdp 7, 15, cr14, cr1, cr8, {4} │ │ │ │ stmiale fp!, {r4, r9, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xee174919 │ │ │ │ @ instruction: 0x46302a10 │ │ │ │ @ instruction: 0xf7e14479 │ │ │ │ - strb lr, [sl, ip, lsr #19]! │ │ │ │ - blx 45de74 <__bss_end__@@Base+0x3b723c> │ │ │ │ + @ instruction: 0xe7eae9b6 │ │ │ │ + blx 45ddfc <__bss_end__@@Base+0x3b725c> │ │ │ │ svcge 0x0069f6ff │ │ │ │ - blhi 11ddd78 <__bss_end__@@Base+0x1137140> │ │ │ │ + blhi 11ddd00 <__bss_end__@@Base+0x1137160> │ │ │ │ ldmdbmi r3, {r1, r2, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ - bcs 45db1c <__bss_end__@@Base+0x3b6ee4> │ │ │ │ + bcs 45daa4 <__bss_end__@@Base+0x3b6f04> │ │ │ │ ldrbtmi r4, [r9], #-1584 @ 0xfffff9d0 │ │ │ │ - ldmib ip, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmib r6!, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7e1e7db │ │ │ │ - svclt 0x0000e878 │ │ │ │ + svclt 0x0000e890 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ svchi 0x005c28f6 │ │ │ │ submi r1, r0, r2, asr #11 │ │ │ │ andeq r0, r0, r0 │ │ │ │ subsmi r8, r6, r0 │ │ │ │ - andeq r5, r3, r6, lsr #30 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq sl, r3, sl, lsr r9 │ │ │ │ - andeq r8, r2, r6, asr #15 │ │ │ │ - andeq r8, r2, ip, ror #14 │ │ │ │ - andeq r5, r3, ip, lsr #28 │ │ │ │ - andeq r8, r2, sl, lsl #14 │ │ │ │ - andeq r8, r2, r0, ror r6 │ │ │ │ - andeq r8, r2, ip, lsr r6 │ │ │ │ - andeq r8, r2, r2, lsl r6 │ │ │ │ + muleq r3, lr, pc @ │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq sl, r3, sl, lsl r9 │ │ │ │ + andeq r8, r2, r2, lsl #20 │ │ │ │ + andeq r8, r2, r8, lsr #19 │ │ │ │ + andeq r5, r3, r4, lsr #29 │ │ │ │ + andeq r8, r2, r6, asr #18 │ │ │ │ + andeq r8, r2, ip, lsr #17 │ │ │ │ + andeq r8, r2, r8, ror r8 │ │ │ │ + andeq r8, r2, lr, asr #16 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb79514 <__bss_end__@@Base+0xfead28dc> │ │ │ │ + bl feb7949c <__bss_end__@@Base+0xfead28fc> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r8], {240} @ 0xf0 │ │ │ │ stmdavs r5, {r8, r9, sp} │ │ │ │ ldrbtmi r2, [ip], #-259 @ 0xfffffefd │ │ │ │ eorcc pc, r5, r4, asr #16 │ │ │ │ streq lr, [r5], #2820 @ 0xb04 │ │ │ │ - blx ff75e3c0 <__bss_end__@@Base+0xff6b7788> │ │ │ │ + blx ff75e348 <__bss_end__@@Base+0xff6b77a8> │ │ │ │ andcs r4, r1, r3, lsl #12 │ │ │ │ addcc pc, r0, r4, asr #17 │ │ │ │ svclt 0x0000bd38 │ │ │ │ - strdeq sl, [r3], -lr │ │ │ │ + ldrdeq sl, [r3], -lr │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb79548 <__bss_end__@@Base+0xfead2910> │ │ │ │ + bl feb794d0 <__bss_end__@@Base+0xfead2930> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r2, #-960]! @ 0xfffffc40 │ │ │ │ ldrbtmi r6, [sp], #-2051 @ 0xfffff7fd │ │ │ │ ldrbtmi r4, [lr], #-3617 @ 0xfffff1df │ │ │ │ eorcs pc, r3, r5, asr r8 @ │ │ │ │ andcs fp, r1, sl, lsl #18 │ │ │ │ andcs fp, r0, #112, 26 @ 0x1c00 │ │ │ │ @@ -31571,49 +31566,49 @@ │ │ │ │ @ instruction: 0xf00b2023 │ │ │ │ stmdacs r0, {r0, r4, r5, r8, fp, ip, sp, lr, pc} │ │ │ │ stmdavs r3!, {r0, r2, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ orreq lr, r3, #5120 @ 0x1400 │ │ │ │ ldrdcc pc, [r0], r3 │ │ │ │ @ instruction: 0xddee2b00 │ │ │ │ strtmi r2, [r0], -r3, lsl #2 │ │ │ │ - blx ff15e418 <__bss_end__@@Base+0xff0b77e0> │ │ │ │ - blle 6e9b90 <__bss_end__@@Base+0x642f58> │ │ │ │ + blx ff15e3a0 <__bss_end__@@Base+0xff0b7800> │ │ │ │ + blle 6e9b18 <__bss_end__@@Base+0x642f78> │ │ │ │ ldmpl r3!, {r2, r4, r8, r9, fp, lr}^ │ │ │ │ stmdblt fp!, {r0, r1, r3, r4, fp, sp, lr}^ │ │ │ │ movtne lr, #6916 @ 0x1b04 │ │ │ │ rscscc pc, pc, #79 @ 0x4f │ │ │ │ svccs 0x0088f8c3 │ │ │ │ - bl 17c430 <__bss_end__@@Base+0xd57f8> │ │ │ │ + bl 17c3b8 <__bss_end__@@Base+0xd5818> │ │ │ │ @ instruction: 0xf8d50583 │ │ │ │ ldrmi r3, [r3], #-128 @ 0xffffff80 │ │ │ │ addcc pc, r0, r5, asr #17 │ │ │ │ @ instruction: 0xf0184620 │ │ │ │ @ instruction: 0x4620f8d7 │ │ │ │ mrscs r2, (UNDEF: 39) │ │ │ │ - blx ffdde448 <__bss_end__@@Base+0xffd37810> │ │ │ │ + blx ffdde3d0 <__bss_end__@@Base+0xffd37830> │ │ │ │ ldcllt 0, cr2, [r0, #-4]! │ │ │ │ andscs r4, ip, #7168 @ 0x1c00 │ │ │ │ tstcs r1, r7, lsl #16 │ │ │ │ ldmpl r3!, {r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf7e0681b │ │ │ │ - @ instruction: 0xe7c2efbc │ │ │ │ - andeq sl, r3, lr, asr #13 │ │ │ │ - andeq r5, r3, sl, lsr #25 │ │ │ │ - muleq r0, r4, r2 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r8, r2, r8, lsr r5 │ │ │ │ + @ instruction: 0xe7c2efd4 │ │ │ │ + andeq sl, r3, lr, lsr #13 │ │ │ │ + andeq r5, r3, r2, lsr #26 │ │ │ │ + andeq r0, r0, ip, lsl #5 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r8, r2, r4, ror r7 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb795f4 <__bss_end__@@Base+0xfead29bc> │ │ │ │ + bl feb7957c <__bss_end__@@Base+0xfead29dc> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ andcs r0, r0, r8, ror #31 │ │ │ │ @ instruction: 0xf0144d41 │ │ │ │ strmi pc, [r4], -r1, lsr #16 │ │ │ │ ldrbtmi r2, [sp], #-3 │ │ │ │ - blx 18de49c <__bss_end__@@Base+0x1837864> │ │ │ │ - ldc2 7, cr15, [r8], #964 @ 0x3c4 │ │ │ │ + blx 18de424 <__bss_end__@@Base+0x1837884> │ │ │ │ + stc2l 7, cr15, [r0, #-964]! @ 0xfffffc3c │ │ │ │ ldrge r2, [r4, -r0, lsl #6]! │ │ │ │ @ instruction: 0x6700e9d7 │ │ │ │ strbcc pc, [r4, #-2244]! @ 0xfffff73c @ │ │ │ │ strbcc pc, [r8, #-2244]! @ 0xfffff73c @ │ │ │ │ andcs pc, r1, #64, 4 │ │ │ │ andeq pc, r1, #192, 4 │ │ │ │ strbcs pc, [r0, #-2244]! @ 0xfffff73c @ │ │ │ │ @@ -31625,15 +31620,15 @@ │ │ │ │ ldrvs lr, [r6, -r4, asr #19] │ │ │ │ orrvc pc, r1, pc, asr #8 │ │ │ │ mvneq pc, r0, asr #5 │ │ │ │ ldrvs lr, [r8, -r4, asr #19] │ │ │ │ ldrbne pc, [ip, #-2244] @ 0xfffff73c @ │ │ │ │ tstcs r0, #196, 18 @ 0x310000 │ │ │ │ @ instruction: 0xf7e8616c │ │ │ │ - msrge CPSR_sc, #11008 @ 0x2b00 │ │ │ │ + msrge CPSR_sc, #23296 @ 0x5b00 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ cmpcs r0, #196, 18 @ 0x310000 │ │ │ │ andcs r4, r0, #638976 @ 0x9c000 │ │ │ │ movwcs r4, #2087 @ 0x827 │ │ │ │ mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ cmncs r6, #196, 18 @ 0x310000 │ │ │ │ movwcs r2, #512 @ 0x200 │ │ │ │ @@ -31653,81 +31648,81 @@ │ │ │ │ strbvs lr, [r4, -r4, asr #19] │ │ │ │ orrcs lr, r2, #196, 18 @ 0x310000 │ │ │ │ movwcs r2, #512 @ 0x200 │ │ │ │ movweq pc, #33476 @ 0x82c4 @ │ │ │ │ biccs lr, r6, #196, 18 @ 0x310000 │ │ │ │ @ instruction: 0xf98ef010 │ │ │ │ @ instruction: 0xf7e54606 │ │ │ │ - @ instruction: 0x4603fe19 │ │ │ │ + strmi pc, [r3], -r9, lsl #28 │ │ │ │ @ instruction: 0xf8c44630 │ │ │ │ @ instruction: 0xf7e03558 │ │ │ │ - strtmi lr, [r8], -r2, lsl #27 │ │ │ │ + @ instruction: 0x4628ed96 │ │ │ │ svclt 0x0000bdf8 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00c99999 │ │ │ │ ssatle r5, #23, fp, lsl #21 │ │ │ │ andgt r8, r4, r7, lsl r9 │ │ │ │ cmp r7, r4, lsl lr │ │ │ │ svclt 0x00fe147a │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r8, r3, r0, lsl #16 │ │ │ │ - andeq r8, r3, lr, lsr #6 │ │ │ │ - andeq sl, r2, r8, lsr r1 │ │ │ │ - andeq r8, r2, r6, lsl #9 │ │ │ │ + andeq r8, r3, lr, lsl #6 │ │ │ │ + andeq sl, r2, ip, asr r3 │ │ │ │ + andeq r8, r2, r2, asr #13 │ │ │ │ andeq r0, r0, r0 │ │ │ │ - blmi f3d20 <__bss_end__@@Base+0x4d0e8> │ │ │ │ + blmi f3ca8 <__bss_end__@@Base+0x4d108> │ │ │ │ ldrbtmi r2, [fp], #-1 │ │ │ │ @ instruction: 0xf8436812 │ │ │ │ ldrbmi r0, [r0, -r2, lsr #32]! │ │ │ │ - andeq sl, r3, r6, lsl #12 │ │ │ │ + andeq sl, r3, r6, ror #11 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8513c <__bss_end__@@Base+0xfeade504> │ │ │ │ + bl feb850c4 <__bss_end__@@Base+0xfeade524> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - bmi fe6263fc <__bss_end__@@Base+0xfe57f7c4> │ │ │ │ - blmi fe633d50 <__bss_end__@@Base+0xfe58d118> │ │ │ │ + bmi fe626384 <__bss_end__@@Base+0xfe57f7e4> │ │ │ │ + blmi fe633cd8 <__bss_end__@@Base+0xfe58d138> │ │ │ │ ldrbtmi fp, [sl], #-141 @ 0xffffff73 │ │ │ │ mulcs r2, r7, pc @ │ │ │ │ - ldrbtmi r4, [pc], #-1549 @ 2254c │ │ │ │ + ldrbtmi r4, [pc], #-1549 @ 224d4 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f930b │ │ │ │ stmdavs r3!, {r8, r9} │ │ │ │ orreq lr, r3, #7168 @ 0x1c00 │ │ │ │ ldrdvs pc, [r0], r3 │ │ │ │ @ instruction: 0xf9b6f024 │ │ │ │ @ instruction: 0x46034990 │ │ │ │ mcrge 6, 0, r4, cr7, cr2, {1} │ │ │ │ @ instruction: 0x46304479 │ │ │ │ - stmda r6, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r0, {r0, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf8d44631 │ │ │ │ @ instruction: 0xf7e00f60 │ │ │ │ - @ instruction: 0xf104ee96 │ │ │ │ + @ instruction: 0xf104eeae │ │ │ │ @ instruction: 0xf7e800c8 │ │ │ │ - @ instruction: 0xf9b4faed │ │ │ │ + @ instruction: 0xf9b4fab7 │ │ │ │ ldc 3, cr3, [r5, #224] @ 0xe0 │ │ │ │ vldr d6, [r4, #480] @ 0x1e0 │ │ │ │ - blcs 412b4 │ │ │ │ - blpl 3ddbec <__bss_end__@@Base+0x336fb4> │ │ │ │ - blcc 1bddbf0 <__bss_end__@@Base+0x1b36fb8> │ │ │ │ - blmi 1d5dbf4 <__bss_end__@@Base+0x1cb6fbc> │ │ │ │ + blcs 4123c │ │ │ │ + blpl 3ddb74 <__bss_end__@@Base+0x336fd4> │ │ │ │ + blcc 1bddb78 <__bss_end__@@Base+0x1b36fd8> │ │ │ │ + blmi 1d5db7c <__bss_end__@@Base+0x1cb6fdc> │ │ │ │ vrintr.f64 d13, d22 │ │ │ │ vadd.f64 d2, d3, d0 │ │ │ │ - vldr d3, [pc, #16] @ 225bc │ │ │ │ + vldr d3, [pc, #16] @ 22544 │ │ │ │ vmov.16 d7[3], r4 │ │ │ │ stmdavs r3!, {r1, r8, r9, fp, ip, sp, lr} │ │ │ │ orreq lr, r3, #7168 @ 0x1c00 │ │ │ │ - blvc 19de58 <__bss_end__@@Base+0xf7220> │ │ │ │ + blvc 19dde0 <__bss_end__@@Base+0xf7240> │ │ │ │ ldrdcc pc, [r0], r3 │ │ │ │ - blvc 5de60 <__bss_start@@Base+0x2dc0> │ │ │ │ - blvs 105dde4 <__bss_end__@@Base+0xfb71ac> │ │ │ │ - blvc 11dfe4 <__bss_end__@@Base+0x773ac> │ │ │ │ - blvc 15de6c <__bss_end__@@Base+0xb7234> │ │ │ │ - blvc ff05e0a8 <__bss_end__@@Base+0xfefb7470> │ │ │ │ - blx 45e19c <__bss_end__@@Base+0x3b7564> │ │ │ │ + blvc 5dde8 <__bss_start@@Base+0x2de0> │ │ │ │ + blvs 105dd6c <__bss_end__@@Base+0xfb71cc> │ │ │ │ + blvc 11df6c <__bss_end__@@Base+0x773cc> │ │ │ │ + blvc 15ddf4 <__bss_end__@@Base+0xb7254> │ │ │ │ + blvc ff05e030 <__bss_end__@@Base+0xfefb7490> │ │ │ │ + blx 45e124 <__bss_end__@@Base+0x3b7584> │ │ │ │ vadd.f64 d13, d7, d14 │ │ │ │ vldr d3, [r4, #28] │ │ │ │ vldr d6, [r4, #840] @ 0x348 │ │ │ │ @ instruction: 0xee264bd0 │ │ │ │ vmla.f64 d5, d3, d6 │ │ │ │ vmov.f64 d5, #84 @ 0x3ea00000 0.3125000 │ │ │ │ vsqrt.f64 d21, d0 │ │ │ │ @@ -31736,135 +31731,135 @@ │ │ │ │ ldrbcc pc, [pc, pc, asr #32]! @ │ │ │ │ vcvt.u16.f64 d4, d4, #-5 │ │ │ │ ldrbtmi r8, [fp], #-2816 @ 0xfffff500 │ │ │ │ muleq r7, r3, r8 │ │ │ │ andeq lr, r7, r6, lsl #17 │ │ │ │ svceq 0x005cf8d4 │ │ │ │ @ instruction: 0xf7e04631 │ │ │ │ - @ instruction: 0xf8d4ee48 │ │ │ │ + @ instruction: 0xf8d4ee60 │ │ │ │ andcs r3, r0, #100, 30 @ 0x190 │ │ │ │ mulsvc sl, r7, r2 │ │ │ │ vldr d13, [r5, #136] @ 0x88 │ │ │ │ vrintz.f64 d7, d6 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ vmov.f64 d7, #70 @ 0x3e300000 0.1718750 │ │ │ │ vsqrt.f64 d23, d8 │ │ │ │ ldmdale r7, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ - blvc 15e108 <__bss_end__@@Base+0xb74d0> │ │ │ │ - blhi ff21e114 <__bss_end__@@Base+0xff1774dc> │ │ │ │ - blx 45e20c <__bss_end__@@Base+0x3b75d4> │ │ │ │ + blvc 15e090 <__bss_end__@@Base+0xb74f0> │ │ │ │ + blhi ff21e09c <__bss_end__@@Base+0xff1774fc> │ │ │ │ + blx 45e194 <__bss_end__@@Base+0x3b75f4> │ │ │ │ mulcs r1, r4, pc @ │ │ │ │ - bmi 162a650 <__bss_end__@@Base+0x1583a18> │ │ │ │ + bmi 162a5d8 <__bss_end__@@Base+0x1583a38> │ │ │ │ ldrbtmi r4, [sl], #-2899 @ 0xfffff4ad │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, fp, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ addshi pc, r1, r0, asr #32 │ │ │ │ ldc 0, cr11, [sp], #52 @ 0x34 │ │ │ │ @ instruction: 0xbdf08b02 │ │ │ │ strb r2, [lr, r0]! │ │ │ │ - bl 1fc700 <__bss_end__@@Base+0x155ac8> │ │ │ │ + bl 1fc688 <__bss_end__@@Base+0x155ae8> │ │ │ │ @ instruction: 0xf8d30383 │ │ │ │ - blcs 2e87c │ │ │ │ - ldc 13, cr13, [pc, #760] @ 22978 │ │ │ │ + blcs 2e804 │ │ │ │ + ldc 13, cr13, [pc, #760] @ 22900 │ │ │ │ strbtmi r0, [r9], -r5, asr #22 │ │ │ │ @ instruction: 0xf0184620 │ │ │ │ @ instruction: 0x4607f939 │ │ │ │ mrc 7, 5, lr, cr1, cr8, {5} │ │ │ │ vsqrt.f64 d4, d5 │ │ │ │ vsub.f64 d5, d4, d6 │ │ │ │ vsub.f64 d6, d5, d6 │ │ │ │ @ instruction: 0xee865b44 │ │ │ │ vdiv.f64 d4, d5, d7 │ │ │ │ vmov.f64 d8, #87 @ 0x3eb80000 0.3593750 │ │ │ │ vsqrt.f64 d20, d0 │ │ │ │ mrc 10, 5, APSR_nzcv, cr5, cr0, {0} │ │ │ │ - blle 8c55b4 <__bss_end__@@Base+0x81e97c> │ │ │ │ - blx 45e27c <__bss_end__@@Base+0x3b7644> │ │ │ │ + blle 8c553c <__bss_end__@@Base+0x81e99c> │ │ │ │ + blx 45e204 <__bss_end__@@Base+0x3b7664> │ │ │ │ vmov.f64 d13, #68 @ 0x3e200000 0.1562500 │ │ │ │ vsqrt.f64 d20, d8 │ │ │ │ ldrle pc, [lr, #-2576] @ 0xfffff5f0 │ │ │ │ - blhi 115e188 <__bss_end__@@Base+0x10b7550> │ │ │ │ + blhi 115e110 <__bss_end__@@Base+0x10b7570> │ │ │ │ ldrbcc pc, [pc, pc, asr #32]! @ │ │ │ │ @ instruction: 0xdc1d2b00 │ │ │ │ - blvc 3de19c <__bss_end__@@Base+0x337564> │ │ │ │ - blhi ff21e1a8 <__bss_end__@@Base+0xff177570> │ │ │ │ - blx 45e2a0 <__bss_end__@@Base+0x3b7668> │ │ │ │ + blvc 3de124 <__bss_end__@@Base+0x337584> │ │ │ │ + blhi ff21e130 <__bss_end__@@Base+0xff177590> │ │ │ │ + blx 45e228 <__bss_end__@@Base+0x3b7688> │ │ │ │ @ instruction: 0xeeb6d945 │ │ │ │ ldmdbmi r4!, {r8, r9, fp, ip, sp, lr} │ │ │ │ mrc 6, 1, r4, cr8, cr0, {1} │ │ │ │ ldrbtmi r7, [r9], #-2823 @ 0xfffff4f9 │ │ │ │ - blvc ff21e2e4 <__bss_end__@@Base+0xff1776ac> │ │ │ │ - bcs fe45df50 <__bss_end__@@Base+0xfe3b7318> │ │ │ │ - svc 0x0084f7e0 │ │ │ │ + blvc ff21e26c <__bss_end__@@Base+0xff1776cc> │ │ │ │ + bcs fe45ded8 <__bss_end__@@Base+0xfe3b7338> │ │ │ │ + svc 0x008ef7e0 │ │ │ │ cdp 7, 15, cr14, cr1, cr10, {4} │ │ │ │ @ instruction: 0xf6fffa10 │ │ │ │ - blcs 4e4f0 │ │ │ │ + blcs 4e478 │ │ │ │ @ instruction: 0xf04fbfd8 │ │ │ │ stclle 7, cr3, [r1, #1020]! @ 0x3fc │ │ │ │ - bleq 89dd8c <__bss_end__@@Base+0x7f7154> │ │ │ │ + bleq 89dd14 <__bss_end__@@Base+0x7f7174> │ │ │ │ strtmi r4, [r0], -r9, ror #12 │ │ │ │ @ instruction: 0xf8f2f018 │ │ │ │ - blle ff669f38 <__bss_end__@@Base+0xff5c3300> │ │ │ │ - blvc ff1ddd74 <__bss_end__@@Base+0xff13713c> │ │ │ │ - blvs 5e1fc <__bss_start@@Base+0x315c> │ │ │ │ - blvc 1de004 <__bss_end__@@Base+0x1373cc> │ │ │ │ - blvc ff25e1fc <__bss_end__@@Base+0xff1b75c4> │ │ │ │ - blx 45e2f4 <__bss_end__@@Base+0x3b76bc> │ │ │ │ + blle ff669ec0 <__bss_end__@@Base+0xff5c3320> │ │ │ │ + blvc ff1ddcfc <__bss_end__@@Base+0xff13715c> │ │ │ │ + blvs 5e184 <__bss_start@@Base+0x317c> │ │ │ │ + blvc 1ddf8c <__bss_end__@@Base+0x1373ec> │ │ │ │ + blvc ff25e184 <__bss_end__@@Base+0xff1b75e4> │ │ │ │ + blx 45e27c <__bss_end__@@Base+0x3b76dc> │ │ │ │ cdp 8, 11, cr13, cr2, cr14, {6} │ │ │ │ vmov.f64 d7, #78 @ 0x3e700000 0.2343750 │ │ │ │ vsqrt.f64 d24, d7 │ │ │ │ stmiale lr, {r4, r9, fp, ip, sp, lr, pc}^ │ │ │ │ - blvs 1de024 <__bss_end__@@Base+0x1373ec> │ │ │ │ + blvs 1ddfac <__bss_end__@@Base+0x13740c> │ │ │ │ @ instruction: 0x4630491c │ │ │ │ mrc 4, 7, r4, cr13, cr9, {3} │ │ │ │ vnmla.f64 d7, d23, d6 │ │ │ │ @ instruction: 0xf7e02a90 │ │ │ │ - @ instruction: 0xf8d4ef56 │ │ │ │ + @ instruction: 0xf8d4ef60 │ │ │ │ shsaxmi r0, r1, ip │ │ │ │ - stc 7, cr15, [r4, #896]! @ 0x380 │ │ │ │ + ldc 7, cr15, [ip, #896]! @ 0x380 │ │ │ │ svccc 0x0064f8d4 │ │ │ │ andsvc r2, sl, r0, lsl #4 │ │ │ │ mrc 7, 5, lr, cr6, cr13, {2} │ │ │ │ ldmdbmi r3, {r8, r9, fp, ip, sp, lr} │ │ │ │ mrc 6, 1, r4, cr8, cr0, {1} │ │ │ │ ldrbtmi r7, [r9], #-2823 @ 0xfffff4f9 │ │ │ │ - blvc ff21e370 <__bss_end__@@Base+0xff177738> │ │ │ │ - bcs fe45dfdc <__bss_end__@@Base+0xfe3b73a4> │ │ │ │ - svc 0x003ef7e0 │ │ │ │ + blvc ff21e2f8 <__bss_end__@@Base+0xff177758> │ │ │ │ + bcs fe45df64 <__bss_end__@@Base+0xfe3b73c4> │ │ │ │ + svc 0x0048f7e0 │ │ │ │ @ instruction: 0xf7e0e744 │ │ │ │ - svclt 0x0000ee1a │ │ │ │ + svclt 0x0000ee32 │ │ │ │ svchi 0x005c28f6 │ │ │ │ submi r1, r0, r2, asr #11 │ │ │ │ svccc 0x00a6defc │ │ │ │ svccc 0x00c691fb │ │ │ │ - @ instruction: 0x00035abe │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - ldrdeq sl, [r3], -r6 │ │ │ │ - andeq r8, r2, r0, ror #6 │ │ │ │ - strdeq r8, [r2], -r2 │ │ │ │ - andeq r5, r3, lr, lsr #19 │ │ │ │ - andeq r8, r2, r2, lsl #4 │ │ │ │ - andeq r8, r2, ip, lsl #3 │ │ │ │ - andeq r8, r2, sl, ror #2 │ │ │ │ + andeq r5, r3, r6, lsr fp │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + @ instruction: 0x0003a5b6 │ │ │ │ + muleq r2, ip, r5 │ │ │ │ + andeq r8, r2, lr, lsr #10 │ │ │ │ + andeq r5, r3, r6, lsr #20 │ │ │ │ + andeq r8, r2, lr, lsr r4 │ │ │ │ + andeq r8, r2, r8, asr #7 │ │ │ │ + andeq r8, r2, r6, lsr #7 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb799c8 <__bss_end__@@Base+0xfead2d90> │ │ │ │ + bl feb79950 <__bss_end__@@Base+0xfead2db0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r8], {240} @ 0xf0 │ │ │ │ stmdavs r5, {r8, r9, sp} │ │ │ │ ldrbtmi r2, [ip], #-258 @ 0xfffffefe │ │ │ │ eorcc pc, r5, r4, asr #16 │ │ │ │ streq lr, [r5], #2820 @ 0xb04 │ │ │ │ @ instruction: 0xf882f024 │ │ │ │ andcs r4, r1, r3, lsl #12 │ │ │ │ addcc pc, r0, r4, asr #17 │ │ │ │ svclt 0x0000bd38 │ │ │ │ - andeq sl, r3, sl, asr #6 │ │ │ │ + andeq sl, r3, sl, lsr #6 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb799fc <__bss_end__@@Base+0xfead2dc4> │ │ │ │ + bl feb79984 <__bss_end__@@Base+0xfead2de4> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r2, #-960]! @ 0xfffffc40 │ │ │ │ ldrbtmi r6, [sp], #-2051 @ 0xfffff7fd │ │ │ │ ldrbtmi r4, [lr], #-3617 @ 0xfffff1df │ │ │ │ eorcs pc, r3, r5, asr r8 @ │ │ │ │ andcs fp, r1, sl, lsl #18 │ │ │ │ andcs fp, r0, #112, 26 @ 0x1c00 │ │ │ │ @@ -31873,48 +31868,48 @@ │ │ │ │ stmdacs r0, {r0, r1, r2, r4, r6, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ stmdavs r3!, {r0, r2, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ orreq lr, r3, #5120 @ 0x1400 │ │ │ │ ldrdcc pc, [r0], r3 │ │ │ │ @ instruction: 0xddee2b00 │ │ │ │ strtmi r2, [r0], -r2, lsl #2 │ │ │ │ @ instruction: 0xf86af024 │ │ │ │ - blle 6ea044 <__bss_end__@@Base+0x64340c> │ │ │ │ + blle 6e9fcc <__bss_end__@@Base+0x64342c> │ │ │ │ ldmpl r3!, {r2, r4, r8, r9, fp, lr}^ │ │ │ │ stmdblt fp!, {r0, r1, r3, r4, fp, sp, lr}^ │ │ │ │ movtne lr, #6916 @ 0x1b04 │ │ │ │ rscscc pc, pc, #79 @ 0x4f │ │ │ │ svccs 0x0088f8c3 │ │ │ │ - bl 17c8e4 <__bss_end__@@Base+0xd5cac> │ │ │ │ + bl 17c86c <__bss_end__@@Base+0xd5ccc> │ │ │ │ @ instruction: 0xf8d50583 │ │ │ │ ldrmi r3, [r3], #-128 @ 0xffffff80 │ │ │ │ addcc pc, r0, r5, asr #17 │ │ │ │ @ instruction: 0xf0174620 │ │ │ │ @ instruction: 0x4620fe7d │ │ │ │ mrscs r2, (UNDEF: 39) │ │ │ │ @ instruction: 0xf89cf022 │ │ │ │ ldcllt 0, cr2, [r0, #-4]! │ │ │ │ andscs r4, sl, #7168 @ 0x1c00 │ │ │ │ tstcs r1, r7, lsl #16 │ │ │ │ ldmpl r3!, {r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf7e0681b │ │ │ │ - strb lr, [r2, r2, ror #26] │ │ │ │ - andeq sl, r3, sl, lsl r3 │ │ │ │ - strdeq r5, [r3], -r6 │ │ │ │ - muleq r0, r4, r2 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - strheq r8, [r2], -r8 @ │ │ │ │ + @ instruction: 0xe7c2ed7a │ │ │ │ + strdeq sl, [r3], -sl @ │ │ │ │ + andeq r5, r3, lr, ror #16 │ │ │ │ + andeq r0, r0, ip, lsl #5 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + strdeq r8, [r2], -r4 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb79aa8 <__bss_end__@@Base+0xfead2e70> │ │ │ │ + bl feb79a30 <__bss_end__@@Base+0xfead2e90> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ andcs r0, r0, r8, ror #31 │ │ │ │ @ instruction: 0xf0134d40 │ │ │ │ strmi pc, [r4], -r7, asr #27 │ │ │ │ ldrbtmi r2, [sp], #-2 │ │ │ │ @ instruction: 0xf808f024 │ │ │ │ - blx 17e0888 <__bss_end__@@Base+0x1739c50> │ │ │ │ + blx 1e0812 <__bss_end__@@Base+0x139c72> │ │ │ │ ldrge r6, [r5, -r0, ror #1]! │ │ │ │ @ instruction: 0x6700e9d7 │ │ │ │ strvs lr, [lr, -r4, asr #19] │ │ │ │ ldmib r1, {r2, r4, r5, r8, sp, pc}^ │ │ │ │ strcs r0, [r0], -r0, lsl #2 │ │ │ │ stmib r4, {r8, r9, sl, sp}^ │ │ │ │ stmib r4, {r4, r8}^ │ │ │ │ @@ -31929,15 +31924,15 @@ │ │ │ │ vst3.16 {d19,d21,d23}, [pc :128], r0 │ │ │ │ vsubw.s8 , q8, d1 │ │ │ │ @ instruction: 0xf8c403de │ │ │ │ vrshl.s8 , q10, q0 │ │ │ │ vsubw.s8 q9, q0, d1 │ │ │ │ @ instruction: 0xf8c40301 │ │ │ │ cmnvs ip, r8, ror #10 │ │ │ │ - @ instruction: 0xf9caf7e8 │ │ │ │ + @ instruction: 0xf9faf7e8 │ │ │ │ stmdami r6!, {r0, r2, r5, r8, fp, lr} │ │ │ │ ldmib r3, {r0, r5, r8, r9, sp, pc}^ │ │ │ │ ldrbtmi r2, [r9], #-768 @ 0xfffffd00 │ │ │ │ cmpcs r0, #196, 18 @ 0x310000 │ │ │ │ andcs r4, r0, #120, 8 @ 0x78000000 │ │ │ │ ldrvs lr, [r0, -r4, asr #19]! │ │ │ │ ldrvs lr, [sl, -r4, asr #19]! │ │ │ │ @@ -31956,78 +31951,78 @@ │ │ │ │ vsubw.s8 q10, q10, d0 │ │ │ │ stmib r4, {r0, r1, r2, r3, r5, r7, r8, r9}^ │ │ │ │ andcs r2, r0, #120, 6 @ 0xe0000001 │ │ │ │ vsubw.s8 q9, q2, d0 │ │ │ │ stmib r4, {r2, r6, r8, r9}^ │ │ │ │ @ instruction: 0xf00f2382 │ │ │ │ strmi pc, [r6], -pc, lsr #30 │ │ │ │ - blx feee0922 <__bss_end__@@Base+0xfee39cea> │ │ │ │ + blx feae08aa <__bss_end__@@Base+0xfea39d0a> │ │ │ │ ldrtmi r4, [r0], -r3, lsl #12 │ │ │ │ ldrbcc pc, [r8, #-2244] @ 0xfffff73c @ │ │ │ │ - bl 8e0918 <__bss_end__@@Base+0x839ce0> │ │ │ │ + bl de08a0 <__bss_end__@@Base+0xd39d00> │ │ │ │ ldcllt 6, cr4, [r8, #160]! @ 0xa0 │ │ │ │ @ instruction: 0x47ae147b │ │ │ │ svccc 0x00a47ae1 │ │ │ │ ssatle r5, #23, fp, lsl #21 │ │ │ │ andgt r8, r4, r7, lsl r9 │ │ │ │ cmp r7, r4, lsl lr │ │ │ │ svclt 0x00fe147a │ │ │ │ - muleq r3, r2, lr │ │ │ │ - andeq r9, r2, r6, lsr #25 │ │ │ │ - strdeq r7, [r2], -r4 │ │ │ │ + andeq r7, r3, r2, ror lr │ │ │ │ + andeq r9, r2, sl, asr #29 │ │ │ │ + andeq r8, r2, r0, lsr r2 │ │ │ │ andeq r0, r0, r0 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb855d8 <__bss_end__@@Base+0xfeade9a0> │ │ │ │ + bl feb85560 <__bss_end__@@Base+0xfeade9c0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - vldr , [pc, #448] @ 22b98 │ │ │ │ + vldr , [pc, #448] @ 22b20 │ │ │ │ strmi r7, [r4], -r5, lsr #22 │ │ │ │ - bleq ff21e4b0 <__bss_end__@@Base+0xff177878> │ │ │ │ - blx 45e5a8 <__bss_end__@@Base+0x3b7970> │ │ │ │ - ldc 5, cr13, [pc, #160] @ 22a88 │ │ │ │ - vldr d7, [pc, #140] @ 22a78 │ │ │ │ - vldr d6, [pc, #144] @ 22a80 │ │ │ │ + bleq ff21e438 <__bss_end__@@Base+0xff177898> │ │ │ │ + blx 45e530 <__bss_end__@@Base+0x3b7990> │ │ │ │ + ldc 5, cr13, [pc, #160] @ 22a10 │ │ │ │ + vldr d7, [pc, #140] @ 22a00 │ │ │ │ + vldr d6, [pc, #144] @ 22a08 │ │ │ │ @ instruction: 0xeeb01b25 │ │ │ │ vmls.f64 d8, d0, d7 │ │ │ │ @ instruction: 0xee888b46 │ │ │ │ vstr d0, [r0, #28] │ │ │ │ @ instruction: 0xf7e08b04 │ │ │ │ - ldc 13, cr14, [pc, #728] @ 22ce0 │ │ │ │ - vldr d6, [pc, #132] @ 22a90 │ │ │ │ - vldr d5, [pc, #136] @ 22a98 │ │ │ │ + ldc 13, cr14, [pc, #768] @ 22c90 │ │ │ │ + vldr d6, [pc, #132] @ 22a18 │ │ │ │ + vldr d5, [pc, #136] @ 22a20 │ │ │ │ vmul.f64 d7, d0, d19 │ │ │ │ vmul.f64 d0, d8, d5 │ │ │ │ vmul.f64 d7, d8, d7 │ │ │ │ vdiv.f64 d8, d0, d6 │ │ │ │ vmov.f64 d6, #23 @ 0x40b80000 5.750 │ │ │ │ vpop {d7-} │ │ │ │ vstr d8, [r4, #8] │ │ │ │ vstr d0, [r4, #8] │ │ │ │ vstr d6, [r4] │ │ │ │ vldrlt d7, [r0, #-24] @ 0xffffffe8 │ │ │ │ - bleq 121e2fc <__bss_end__@@Base+0x11776c4> │ │ │ │ - blvc 69e0bc <__bss_end__@@Base+0x5f7484> │ │ │ │ - blhi 6de0c0 <__bss_end__@@Base+0x637488> │ │ │ │ + bleq 121e284 <__bss_end__@@Base+0x11776e4> │ │ │ │ + blvc 69e044 <__bss_end__@@Base+0x5f74a4> │ │ │ │ + blhi 6de048 <__bss_end__@@Base+0x6374a8> │ │ │ │ ldmib r3, {r0, r1, r2, r3, r4, r8, r9, sp, pc}^ │ │ │ │ stmib r0, {r8, r9, sp}^ │ │ │ │ cdp 3, 2, cr2, cr0, cr4, {0} │ │ │ │ vdiv.f64 d0, d0, d7 │ │ │ │ @ instruction: 0xf7e00b08 │ │ │ │ - vldr s28, [pc, #528] @ 22c6c │ │ │ │ - vldr d6, [pc, #88] @ 22ab8 │ │ │ │ + vldr s28, [pc, #608] @ 22c44 │ │ │ │ + vldr d6, [pc, #88] @ 22a40 │ │ │ │ vmov.32 d0[1], r7 │ │ │ │ vdiv.f64 d0, d0, d6 │ │ │ │ ldrb r6, [ip, r8, lsl #22] │ │ │ │ strbtvs r6, [r6], -r6, ror #12 │ │ │ │ rscmi r9, r1, r6, lsr #30 │ │ │ │ ldmcs r5!, {r4, r7, r9, lr, pc}^ │ │ │ │ addmi r3, r0, ip, asr r5 │ │ │ │ subsls r4, r0, #35, 30 @ 0x8c │ │ │ │ svccc 0x006d36c7 │ │ │ │ - blgt fe6ca120 <__bss_end__@@Base+0xfe6234e8> │ │ │ │ + blgt fe6ca0a8 <__bss_end__@@Base+0xfe623508> │ │ │ │ andsmi r0, r5, sp, lsl #12 │ │ │ │ stmdacs r4, {r0, r1, r2, r4, r5, r6, ip, sp, pc} │ │ │ │ strhtmi ip, [r2], sp │ │ │ │ bicsge r0, r7, #249856 @ 0x3d000 │ │ │ │ adcmi r8, r0, r0, ror r8 │ │ │ │ ldcpl 14, cr8, [sp, #388]! @ 0x184 │ │ │ │ addsmi sp, sl, r7, asr r1 │ │ │ │ @@ -32039,85 +32034,85 @@ │ │ │ │ ldrsbtmi r8, [sp], #-166 @ 0xffffff5a │ │ │ │ strpl ip, [r0], #-3806 @ 0xfffff122 │ │ │ │ addmi r4, lr, r8, lsl r0 │ │ │ │ cdpne 1, 11, cr5, cr8, cr12, {7} │ │ │ │ rsbsmi r5, r8, r5, lsl #31 │ │ │ │ vst3.8 {d27,d29,d31}, [pc], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb856e0 <__bss_end__@@Base+0xfeadeaa8> │ │ │ │ + bl feb85668 <__bss_end__@@Base+0xfeadeac8> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - vldr , [pc, #384] @ 22c60 │ │ │ │ + vldr , [pc, #384] @ 22be8 │ │ │ │ addlt r6, r5, r7, lsl fp │ │ │ │ - blvc 61e164 <__bss_end__@@Base+0x57752c> │ │ │ │ - blhi 109e5ac <__bss_end__@@Base+0xff7974> │ │ │ │ + blvc 61e0ec <__bss_end__@@Base+0x57754c> │ │ │ │ + blhi 109e534 <__bss_end__@@Base+0xff7994> │ │ │ │ stmdage r2, {r0, r3, r5, r6, r9, sl, lr} │ │ │ │ - bleq 1de374 <__bss_end__@@Base+0x13773c> │ │ │ │ - bleq 21e4f8 <__bss_end__@@Base+0x1778c0> │ │ │ │ - b fefe0a7c <__bss_end__@@Base+0xfef39e44> │ │ │ │ - blpl 51e17c <__bss_end__@@Base+0x477544> │ │ │ │ - blmi 55e180 <__bss_end__@@Base+0x4b7548> │ │ │ │ + bleq 1de2fc <__bss_end__@@Base+0x13775c> │ │ │ │ + bleq 21e480 <__bss_end__@@Base+0x1778e0> │ │ │ │ + b ff560a04 <__bss_end__@@Base+0xff4b9e64> │ │ │ │ + blpl 51e104 <__bss_end__@@Base+0x477564> │ │ │ │ + blmi 55e108 <__bss_end__@@Base+0x4b7568> │ │ │ │ ldc 0, cr2, [sp] │ │ │ │ tstcs r0, r0, lsl #22 │ │ │ │ - blhi 19e3b0 <__bss_end__@@Base+0xf7778> │ │ │ │ - blvc de188 <__bss_end__@@Base+0x37550> │ │ │ │ + blhi 19e338 <__bss_end__@@Base+0xf7798> │ │ │ │ + blvc de110 <__bss_end__@@Base+0x37570> │ │ │ │ ldrbtmi r4, [fp], #-2833 @ 0xfffff4ef │ │ │ │ - blpl 15e53c <__bss_end__@@Base+0xb7904> │ │ │ │ + blpl 15e4c4 <__bss_end__@@Base+0xb7924> │ │ │ │ smlabteq r4, r3, r9, lr │ │ │ │ - blvs 19e3bc <__bss_end__@@Base+0xf7784> │ │ │ │ - blvc 19e3c4 <__bss_end__@@Base+0xf778c> │ │ │ │ - blvs 5e138 <__bss_start@@Base+0x3098> │ │ │ │ - blvc de13c <__bss_end__@@Base+0x37504> │ │ │ │ + blvs 19e344 <__bss_end__@@Base+0xf77a4> │ │ │ │ + blvc 19e34c <__bss_end__@@Base+0xf77ac> │ │ │ │ + blvs 5e0c0 <__bss_start@@Base+0x30b8> │ │ │ │ + blvc de0c4 <__bss_end__@@Base+0x37524> │ │ │ │ ldc 0, cr11, [sp], #20 │ │ │ │ @ instruction: 0xf85d8b02 │ │ │ │ svclt 0x0000fb04 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ adcvc sp, r3, sl, lsl #14 │ │ │ │ adcsmi fp, r7, sp, lsl ip │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ - andeq sl, r3, sl, lsl #2 │ │ │ │ + andeq sl, r3, sl, ror #1 │ │ │ │ ldrbtmi r4, [fp], #-2818 @ 0xfffff4fe │ │ │ │ - bleq 1de174 <__bss_end__@@Base+0x13753c> │ │ │ │ + bleq 1de0fc <__bss_end__@@Base+0x13755c> │ │ │ │ svclt 0x00004770 │ │ │ │ - strheq sl, [r3], -lr │ │ │ │ + muleq r3, lr, r0 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb85794 <__bss_end__@@Base+0xfeadeb5c> │ │ │ │ + bl feb8571c <__bss_end__@@Base+0xfeadeb7c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi 19a6ae4 <__bss_end__@@Base+0x18ffeac> │ │ │ │ - blhi 105e648 <__bss_end__@@Base+0xfb7a10> │ │ │ │ + blmi 19a6a6c <__bss_end__@@Base+0x18ffecc> │ │ │ │ + blhi 105e5d0 <__bss_end__@@Base+0xfb7a30> │ │ │ │ ldrbtmi r4, [fp], #-2405 @ 0xfffff69b │ │ │ │ @ instruction: 0x4c664a65 │ │ │ │ ldmdapl sp, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldc 4, cr4, [r2, #496] @ 0x1f0 │ │ │ │ vldr d6, [r4] │ │ │ │ vldr d2, [r5, #32] │ │ │ │ vldr d7, [r4] │ │ │ │ vldr d3, [r4, #40] @ 0x28 │ │ │ │ vmov.f64 d4, #76 @ 0x3e600000 0.2187500 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ @ instruction: 0xdc1efa10 │ │ │ │ - bleq 159e234 <__bss_end__@@Base+0x14f75fc> │ │ │ │ + bleq 159e1bc <__bss_end__@@Base+0x14f761c> │ │ │ │ @ instruction: 0xee384b5c │ │ │ │ ldrbtmi r8, [fp], #-2816 @ 0xfffff500 │ │ │ │ rsbeq pc, r0, r3, lsl #2 │ │ │ │ - blpl 5e214 <__bss_start@@Base+0x3174> │ │ │ │ - blne 25e5cc <__bss_end__@@Base+0x1b7994> │ │ │ │ - blvs de21c <__bss_end__@@Base+0x375e4> │ │ │ │ - blvc 15e220 <__bss_end__@@Base+0xb75e8> │ │ │ │ - blhi 1ddecc <__bss_end__@@Base+0x137294> │ │ │ │ - blpl de3e0 <__bss_end__@@Base+0x377a8> │ │ │ │ - blvs 11e3e4 <__bss_end__@@Base+0x777ac> │ │ │ │ - blvc 15e3e8 <__bss_end__@@Base+0xb77b0> │ │ │ │ - blpl 65e1f4 <__bss_end__@@Base+0x5b75bc> │ │ │ │ - blvs 6de1f8 <__bss_end__@@Base+0x6375c0> │ │ │ │ - blvc 75e1fc <__bss_end__@@Base+0x6b75c4> │ │ │ │ + blpl 5e19c <__bss_start@@Base+0x3194> │ │ │ │ + blne 25e554 <__bss_end__@@Base+0x1b79b4> │ │ │ │ + blvs de1a4 <__bss_end__@@Base+0x37604> │ │ │ │ + blvc 15e1a8 <__bss_end__@@Base+0xb7608> │ │ │ │ + blhi 1dde54 <__bss_end__@@Base+0x1372b4> │ │ │ │ + blpl de368 <__bss_end__@@Base+0x377c8> │ │ │ │ + blvs 11e36c <__bss_end__@@Base+0x777cc> │ │ │ │ + blvc 15e370 <__bss_end__@@Base+0xb77d0> │ │ │ │ + blpl 65e17c <__bss_end__@@Base+0x5b75dc> │ │ │ │ + blvs 6de180 <__bss_end__@@Base+0x6375e0> │ │ │ │ + blvc 75e184 <__bss_end__@@Base+0x6b75e4> │ │ │ │ ldc 13, cr11, [r4, #224] @ 0xe0 │ │ │ │ vldr d5, [r4, #56] @ 0x38 │ │ │ │ vstr d6, [r4, #64] @ 0x40 │ │ │ │ vadd.f64 d7, d7, d14 │ │ │ │ vsub.f64 d5, d6, d5 │ │ │ │ vsub.f64 d1, d6, d2 │ │ │ │ vsub.f64 d0, d6, d3 │ │ │ │ @@ -32128,42 +32123,42 @@ │ │ │ │ vmla.f64 d3, d6, d5 │ │ │ │ vmov.f64 d4, #69 @ 0x3e280000 0.1640625 │ │ │ │ vsqrt.f64 d23, d1 │ │ │ │ vstr s30, [r4, #64] @ 0x40 │ │ │ │ vstr d2, [r4, #32] │ │ │ │ vstr d3, [r4, #40] @ 0x28 │ │ │ │ stmdale r8, {r2, r3, r8, r9, fp, lr} │ │ │ │ - blvs dde2b8 <__bss_end__@@Base+0xd37680> │ │ │ │ + blvs dde240 <__bss_end__@@Base+0xd376a0> │ │ │ │ vmov.s16 r4, d7[2] │ │ │ │ ldrbtmi r7, [fp], #-2822 @ 0xfffff4fa │ │ │ │ - blvc 5e254 <__bss_start@@Base+0x31b4> │ │ │ │ + blvc 5e1dc <__bss_start@@Base+0x31d4> │ │ │ │ @ instruction: 0xf7f1e7b4 │ │ │ │ - mrc 12, 1, APSR_nzcv, cr0, cr7, {3} │ │ │ │ + mrc 13, 1, APSR_nzcv, cr0, cr15, {0} │ │ │ │ vmov.f64 d0, #112 @ 0x3f800000 1.0 │ │ │ │ vldr d10, [r4] │ │ │ │ vmov.f64 d7, #22 @ 0x40b00000 5.5 │ │ │ │ vadd.f64 d9, d0, d4 │ │ │ │ vnmul.f64 d0, d0, d10 │ │ │ │ vmul.f64 d7, d7, d7 │ │ │ │ vmul.f64 d7, d7, d0 │ │ │ │ vmul.f64 d7, d7, d0 │ │ │ │ vmul.f64 d7, d7, d0 │ │ │ │ vstr d7, [r4] │ │ │ │ @ instruction: 0xf7f17b10 │ │ │ │ - mrc 12, 1, APSR_nzcv, cr0, cr15, {2} │ │ │ │ + cdp 13, 3, cr15, cr0, cr7, {0} │ │ │ │ vldr d0, [r4] │ │ │ │ vadd.f64 d7, d0, d6 │ │ │ │ vnmul.f64 d0, d0, d10 │ │ │ │ vmul.f64 d7, d7, d7 │ │ │ │ vmul.f64 d7, d7, d0 │ │ │ │ vmul.f64 d7, d7, d0 │ │ │ │ vmul.f64 d7, d7, d0 │ │ │ │ vstr d7, [r4] │ │ │ │ @ instruction: 0xf7f17b12 │ │ │ │ - cdp 12, 3, cr15, cr0, cr11, {2} │ │ │ │ + mrc 12, 1, APSR_nzcv, cr0, cr3, {7} │ │ │ │ vldr d0, [r4] │ │ │ │ vldr d6, [r4, #24] │ │ │ │ vmov.32 r5, d2[1] │ │ │ │ vldr d1, [r4, #16] │ │ │ │ vldr d4, [r5, #72] @ 0x48 │ │ │ │ vadd.f64 d7, d0, d0 │ │ │ │ vmov.f64 d0, d10 │ │ │ │ @@ -32185,74 +32180,74 @@ │ │ │ │ vadd.f64 d6, d6, d5 │ │ │ │ vstr d6, [r4, #28] │ │ │ │ @ instruction: 0xe7956b16 │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r7, r7, r0 │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00b99999 │ │ │ │ - andeq r5, r3, r6, ror r4 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - ldrdeq r7, [r3], -r8 │ │ │ │ - andeq sl, r3, ip, lsl #1 │ │ │ │ - andeq sl, r3, r2, rrx │ │ │ │ - andeq r7, r3, r6, lsr #22 │ │ │ │ + andeq r5, r3, lr, ror #9 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + @ instruction: 0x00037bb8 │ │ │ │ + andeq sl, r3, ip, rrx │ │ │ │ + andeq sl, r3, r2, asr #32 │ │ │ │ + andeq r7, r3, r6, lsl #22 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb79f3c <__bss_end__@@Base+0xfead3304> │ │ │ │ + bl feb79ec4 <__bss_end__@@Base+0xfead3324> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [fp], {248} @ 0xf8 │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ stmdavs r3, {r4, r5, r8, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f06023 │ │ │ │ - stmdavs r0!, {r0, r2, r3, r4, r5, r6, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + stmdavs r0!, {r0, r2, r5, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ ldrbtmi r4, [ip], #-3078 @ 0xfffff3fa │ │ │ │ teqlt r0, r0, ror #16 │ │ │ │ rsbvs r6, r3, r3, lsl #16 │ │ │ │ - mrc2 7, 7, pc, cr2, cr0, {7} │ │ │ │ + @ instruction: 0xff9af7f0 │ │ │ │ stmdacs r0, {r5, r6, fp, sp, lr} │ │ │ │ ldclt 1, cr13, [r0, #-992] @ 0xfffffc20 │ │ │ │ - andeq r9, r3, r4, asr pc │ │ │ │ - andeq r9, r3, lr, lsr pc │ │ │ │ + andeq r9, r3, r4, lsr pc │ │ │ │ + andeq r9, r3, lr, lsl pc │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb79f80 <__bss_end__@@Base+0xfead3348> │ │ │ │ + bl feb79f08 <__bss_end__@@Base+0xfead3368> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi 426d48 <__bss_end__@@Base+0x380110> │ │ │ │ + blmi 426cd0 <__bss_end__@@Base+0x380130> │ │ │ │ ldrbtmi r4, [fp], #-2576 @ 0xfffff5f0 │ │ │ │ ldmdavs ip, {r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - blmi 40f4a4 <__bss_end__@@Base+0x36886c> │ │ │ │ + blmi 40f42c <__bss_end__@@Base+0x36888c> │ │ │ │ ldrbtmi r4, [sp], #-3343 @ 0xfffff2f1 │ │ │ │ ldrd r5, [sl], -r6 │ │ │ │ stmdbvs r3!, {r1, r5, fp, sp, lr}^ │ │ │ │ ldrdeq lr, [r6, -r4] │ │ │ │ ldrmi r6, [r8, sl, lsr #32] │ │ │ │ eorvs r6, r3, fp, ror #16 │ │ │ │ stmdavs ip!, {r2, r3, r5, r6, sp, lr} │ │ │ │ ldc 1, cr11, [r4, #272] @ 0x110 │ │ │ │ vldr d6, [r6, #8] │ │ │ │ vmov.f64 d7, #64 @ 0x3e000000 0.125 │ │ │ │ vsqrt.f64 d22, d7 │ │ │ │ stmible fp!, {r4, r9, fp, ip, sp, lr, pc}^ │ │ │ │ svclt 0x0000bd70 │ │ │ │ - andeq r9, r3, lr, lsl #30 │ │ │ │ - andeq r5, r3, r4, ror r2 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - andeq r9, r3, r2, lsl #30 │ │ │ │ + andeq r9, r3, lr, ror #29 │ │ │ │ + andeq r5, r3, ip, ror #5 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + andeq r9, r3, r2, ror #29 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi de298 <__bss_end__@@Base+0x37660> │ │ │ │ + blhi de220 <__bss_end__@@Base+0x37680> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00e0f8cc │ │ │ │ @ instruction: 0xeeb04b29 │ │ │ │ @ instruction: 0xf8df8b40 │ │ │ │ strmi r8, [r7], -r4, lsr #1 │ │ │ │ @ instruction: 0x460e447b │ │ │ │ @ instruction: 0x461544f8 │ │ │ │ stccs 8, cr6, [r0], {92} @ 0x5c │ │ │ │ stmdavs r2!, {r3, r4, r5, ip, lr, pc} │ │ │ │ - blmi 93af74 <__bss_end__@@Base+0x89433c> │ │ │ │ + blmi 93aefc <__bss_end__@@Base+0x89435c> │ │ │ │ ldrbtmi r4, [fp], #-2596 @ 0xfffff5dc │ │ │ │ @ instruction: 0x61206898 │ │ │ │ addsvs r1, r9, r1, asr #24 │ │ │ │ ldrdgt pc, [r0], -r3 │ │ │ │ andcs pc, r2, r8, asr r8 @ │ │ │ │ strvc lr, [r5], -r4, asr #19 │ │ │ │ ldc 1, cr6, [r2, #916] @ 0x394 │ │ │ │ @@ -32262,178 +32257,178 @@ │ │ │ │ andsle r0, r0, r0, lsl #30 │ │ │ │ movwcs r4, #1634 @ 0x662 │ │ │ │ ldmdavs r1, {r0, r1, sp, lr, pc} │ │ │ │ orrslt r4, r9, r3, lsl r6 │ │ │ │ ldc 6, cr4, [r2, #40] @ 0x28 │ │ │ │ vmov.f64 d6, #66 @ 0x3e100000 0.1406250 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ - ble ffd61694 <__bss_end__@@Base+0xffcbaa5c> │ │ │ │ - blmi 511364 <__bss_end__@@Base+0x46a72c> │ │ │ │ + ble ffd6161c <__bss_end__@@Base+0xffcbaa7c> │ │ │ │ + blmi 5112ec <__bss_end__@@Base+0x46a74c> │ │ │ │ ldc 4, cr4, [sp], #492 @ 0x1ec │ │ │ │ @ instruction: 0xf8c48b02 │ │ │ │ andsvs ip, ip, r0 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ @ instruction: 0x461a4611 │ │ │ │ - blhi de164 <__bss_end__@@Base+0x3752c> │ │ │ │ + blhi de0ec <__bss_end__@@Base+0x3754c> │ │ │ │ eorvs r6, r1, r4, lsl r0 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ ldrbtmi r4, [r8], #-2059 @ 0xfffff7f5 │ │ │ │ - @ instruction: 0xf90ef7f1 │ │ │ │ + @ instruction: 0xf9b6f7f1 │ │ │ │ strtmi r4, [r3], -sl, lsl #16 │ │ │ │ ldrbtmi r2, [r8], #-544 @ 0xfffffde0 │ │ │ │ @ instruction: 0xf7f0214c │ │ │ │ - strmi pc, [r4], -pc, lsr #27 │ │ │ │ + @ instruction: 0x4604fe57 │ │ │ │ svclt 0x0000e7bb │ │ │ │ - andeq r9, r3, r0, lsr #29 │ │ │ │ - andeq r5, r3, r4, lsl #4 │ │ │ │ - andeq r9, r3, sl, lsl #29 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - andeq r9, r3, r0, asr #28 │ │ │ │ + andeq r9, r3, r0, lsl #29 │ │ │ │ + andeq r5, r3, ip, ror r2 │ │ │ │ + andeq r9, r3, sl, ror #28 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + andeq r9, r3, r0, lsr #28 │ │ │ │ @ instruction: 0xfffffeb7 │ │ │ │ - andeq r7, r2, lr, asr #21 │ │ │ │ + andeq r7, r2, sl, lsl #26 │ │ │ │ ldrbtmi r4, [sl], #-2582 @ 0xfffff5ea │ │ │ │ tstlt r9, #1114112 @ 0x110000 │ │ │ │ stmdbvs ip, {r4, sl, ip, sp, pc} │ │ │ │ addmi r6, r4, #720896 @ 0xb0000 │ │ │ │ stmdblt r3!, {r0, r1, r4, ip, lr, pc} │ │ │ │ ldmdavs sl, {r1, r2, r3, sp, lr, pc} │ │ │ │ @ instruction: 0x46134619 │ │ │ │ ldmdbvs sl, {r1, r4, r6, r8, ip, sp, pc} │ │ │ │ mvnsle r4, r2, lsl #5 │ │ │ │ ldmdavs sl, {r1, r2, r3, fp, lr} │ │ │ │ andvs r4, sl, r8, ror r4 │ │ │ │ orrlt r6, r2, r2, asr #16 │ │ │ │ subvs r6, r3, sl, lsl r0 │ │ │ │ - blmi 16105c <__bss_end__@@Base+0xba424> │ │ │ │ + blmi 160fe4 <__bss_end__@@Base+0xba444> │ │ │ │ ldmdavs r0, {r4, r5, r6, r8, r9, sl, lr}^ │ │ │ │ @ instruction: 0xb1206013 │ │ │ │ - blmi 161068 <__bss_end__@@Base+0xba430> │ │ │ │ + blmi 160ff0 <__bss_end__@@Base+0xba450> │ │ │ │ subsvs r6, r1, r8 │ │ │ │ subsvs r4, r1, r0, ror r7 │ │ │ │ ldrb r6, [r1, r8]! │ │ │ │ @ instruction: 0xf85d4770 │ │ │ │ subvs r4, r3, r4, lsl #22 │ │ │ │ @ instruction: 0x4770601a │ │ │ │ - andeq r9, r3, r6, ror #27 │ │ │ │ - andeq r9, r3, r0, asr #27 │ │ │ │ + andeq r9, r3, r6, asr #27 │ │ │ │ + andeq r9, r3, r0, lsr #27 │ │ │ │ stmdavs r3, {r3, r5, r8, ip, sp, pc} │ │ │ │ @ instruction: 0xf5032200 │ │ │ │ @ instruction: 0xf8c35380 │ │ │ │ ldrbmi r2, [r0, -r4, lsl #2]! │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb85b40 <__bss_end__@@Base+0xfeadef08> │ │ │ │ + bl feb85ac8 <__bss_end__@@Base+0xfeadef28> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ vldr , [r0, #352] @ 0x160 │ │ │ │ addlt r0, r4, sl, ror fp │ │ │ │ - blvc 81e5bc <__bss_end__@@Base+0x777984> │ │ │ │ - blls 1fde584 <__bss_end__@@Base+0x1f3794c> │ │ │ │ - blhi ff05ea08 <__bss_end__@@Base+0xfefb7dd0> │ │ │ │ - blhi ff21ea1c <__bss_end__@@Base+0xff177de4> │ │ │ │ - blx 45eb14 <__bss_end__@@Base+0x3b7edc> │ │ │ │ + blvc 81e544 <__bss_end__@@Base+0x7779a4> │ │ │ │ + blls 1fde50c <__bss_end__@@Base+0x1f3796c> │ │ │ │ + blhi ff05e990 <__bss_end__@@Base+0xfefb7df0> │ │ │ │ + blhi ff21e9a4 <__bss_end__@@Base+0xff177e04> │ │ │ │ + blx 45ea9c <__bss_end__@@Base+0x3b7efc> │ │ │ │ strmi sp, [r4], -fp, lsr #24 │ │ │ │ stmdage r2, {r0, r3, r5, r6, r9, sl, lr} │ │ │ │ - stm lr, {r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blvs 69e5dc <__bss_end__@@Base+0x5f79a4> │ │ │ │ - bleq de5d8 <__bss_end__@@Base+0x379a0> │ │ │ │ - blpl fe05e5b8 <__bss_end__@@Base+0xfdfb7980> │ │ │ │ - blhi ff1dea3c <__bss_end__@@Base+0xff137e04> │ │ │ │ - blvc 5e5e4 <__bss_start@@Base+0x3544> │ │ │ │ - bleq 19e7f4 <__bss_end__@@Base+0xf7bbc> │ │ │ │ - blx 45eb3c <__bss_end__@@Base+0x3b7f04> │ │ │ │ - bleq 29e7d8 <__bss_end__@@Base+0x1f7ba0> │ │ │ │ + stmia r4!, {r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blvs 69e564 <__bss_end__@@Base+0x5f79c4> │ │ │ │ + bleq de560 <__bss_end__@@Base+0x379c0> │ │ │ │ + blpl fe05e540 <__bss_end__@@Base+0xfdfb79a0> │ │ │ │ + blhi ff1de9c4 <__bss_end__@@Base+0xff137e24> │ │ │ │ + blvc 5e56c <__bss_start@@Base+0x3564> │ │ │ │ + bleq 19e77c <__bss_end__@@Base+0xf7bdc> │ │ │ │ + blx 45eac4 <__bss_end__@@Base+0x3b7f24> │ │ │ │ + bleq 29e760 <__bss_end__@@Base+0x1f7bc0> │ │ │ │ andlt sp, r4, r3, lsl #24 │ │ │ │ - blhi 15e278 <__bss_end__@@Base+0xb7640> │ │ │ │ + blhi 15e200 <__bss_end__@@Base+0xb7660> │ │ │ │ mrc 13, 1, fp, cr8, cr0, {0} │ │ │ │ vrintx.f64 d8, d6 │ │ │ │ vdiv.f64 d5, d8, d0 │ │ │ │ vadd.f64 d7, d5, d6 │ │ │ │ vnmul.f64 d5, d7, d7 │ │ │ │ vmla.f64 d7, d5, d9 │ │ │ │ vmov.f64 d7, #0 @ 0x40000000 2.0 │ │ │ │ andlt r0, r4, r7, asr #22 │ │ │ │ - blhi 15e29c <__bss_end__@@Base+0xb7664> │ │ │ │ + blhi 15e224 <__bss_end__@@Base+0xb7684> │ │ │ │ mrc 13, 5, fp, cr0, cr0, {0} │ │ │ │ andlt r0, r4, r9, asr #22 │ │ │ │ - blhi 15e2a8 <__bss_end__@@Base+0xb7670> │ │ │ │ + blhi 15e230 <__bss_end__@@Base+0xb7690> │ │ │ │ svclt 0x0000bd10 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ stmdacc sp!, {r0, r2, r5, r6, r8, r9, ip, sp, lr} │ │ │ │ svccc 0x00f0c152 │ │ │ │ stmdacc sp!, {r0, r2, r5, r6, r8, r9, ip, sp, lr} │ │ │ │ svccc 0x00e0c152 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb85c00 <__bss_end__@@Base+0xfeadefc8> │ │ │ │ + bl feb85b88 <__bss_end__@@Base+0xfeadefe8> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ vldr , [r0, #256] @ 0x100 │ │ │ │ addlt r0, r4, sl, ror fp │ │ │ │ - blvc b9e664 <__bss_end__@@Base+0xaf7a2c> │ │ │ │ - blls 1f5e62c <__bss_end__@@Base+0x1eb79f4> │ │ │ │ - blhi ff05eab0 <__bss_end__@@Base+0xfefb7e78> │ │ │ │ - blhi ff21eac4 <__bss_end__@@Base+0xff177e8c> │ │ │ │ - blx 45ebbc <__bss_end__@@Base+0x3b7f84> │ │ │ │ + blvc b9e5ec <__bss_end__@@Base+0xaf7a4c> │ │ │ │ + blls 1f5e5b4 <__bss_end__@@Base+0x1eb7a14> │ │ │ │ + blhi ff05ea38 <__bss_end__@@Base+0xfefb7e98> │ │ │ │ + blhi ff21ea4c <__bss_end__@@Base+0xff177eac> │ │ │ │ + blx 45eb44 <__bss_end__@@Base+0x3b7fa4> │ │ │ │ ldc 12, cr13, [r0, #204] @ 0xcc │ │ │ │ @ instruction: 0x4604ab78 │ │ │ │ - bllt ff2deac4 <__bss_end__@@Base+0xff237e8c> │ │ │ │ - bllt ff21ead8 <__bss_end__@@Base+0xff177ea0> │ │ │ │ - blx 45ebd0 <__bss_end__@@Base+0x3b7f98> │ │ │ │ + bllt ff2dea4c <__bss_end__@@Base+0xff237eac> │ │ │ │ + bllt ff21ea60 <__bss_end__@@Base+0xff177ec0> │ │ │ │ + blx 45eb58 <__bss_end__@@Base+0x3b7fb8> │ │ │ │ strbtmi sp, [r9], -r9, lsr #24 │ │ │ │ @ instruction: 0xf7e0a802 │ │ │ │ - mrc 8, 5, lr, cr0, cr2, {1} │ │ │ │ + cdp 8, 11, cr14, cr0, cr8, {2} │ │ │ │ @ instruction: 0xf7e00b4a │ │ │ │ - vldr s28, [r4, #392] @ 0x188 │ │ │ │ + vldr s28, [r4, #456] @ 0x1c8 │ │ │ │ vldr d7, [r4, #504] @ 0x1f8 │ │ │ │ @ instruction: 0xeeb06b80 │ │ │ │ vldr d5, [sp, #292] @ 0x124 │ │ │ │ vmul.f64 d12, d0, d2 │ │ │ │ vldr d7, [sp, #28] │ │ │ │ vmul.f64 d10, d0, d0 │ │ │ │ - vldr d0, [pc, #24] @ 23054 │ │ │ │ + vldr d0, [pc, #24] @ 22fdc │ │ │ │ vmov.32 d7[0], r6 │ │ │ │ vmov.f64 d5, #76 @ 0x3e600000 0.2187500 │ │ │ │ vsqrt.f64 d24, d6 │ │ │ │ mrc 10, 5, APSR_nzcv, cr0, cr0, {0} │ │ │ │ vmls.f64 d7, d0, d5 │ │ │ │ @ instruction: 0xdc0c7b0a │ │ │ │ - bllt ff1deb28 <__bss_end__@@Base+0xff137ef0> │ │ │ │ - blx 45ec20 <__bss_end__@@Base+0x3b7fe8> │ │ │ │ + bllt ff1deab0 <__bss_end__@@Base+0xff137f10> │ │ │ │ + blx 45eba8 <__bss_end__@@Base+0x3b8008> │ │ │ │ cdp 12, 11, cr13, cr0, cr7, {0} │ │ │ │ vmov.f64 d9, d7 │ │ │ │ andlt r0, r4, r9, asr #22 │ │ │ │ - blhi 2de360 <__bss_end__@@Base+0x237728> │ │ │ │ - ldc 13, cr11, [pc, #64] @ 230b0 │ │ │ │ + blhi 2de2e8 <__bss_end__@@Base+0x237748> │ │ │ │ + ldc 13, cr11, [pc, #64] @ 23038 │ │ │ │ vmov.f64 d4, #125 @ 0x3fe80000 1.8125000 │ │ │ │ vadd.f64 d5, d8, d0 │ │ │ │ @ instruction: 0xee888b44 │ │ │ │ vadd.f64 d6, d5, d4 │ │ │ │ vnmul.f64 d5, d6, d6 │ │ │ │ vmla.f64 d9, d5, d9 │ │ │ │ vmov.f64 d9, #7 @ 0x40380000 2.875 │ │ │ │ andlt r0, r4, r9, asr #22 │ │ │ │ - blhi 2de388 <__bss_end__@@Base+0x237750> │ │ │ │ + blhi 2de310 <__bss_end__@@Base+0x237770> │ │ │ │ svclt 0x0000bd10 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ stmdacc sp!, {r0, r2, r5, r6, r8, r9, ip, sp, lr} │ │ │ │ svccc 0x00f0c152 │ │ │ │ stmdacc sp!, {r0, r2, r5, r6, r8, r9, ip, sp, lr} │ │ │ │ svccc 0x00e0c152 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb7a2b4 <__bss_end__@@Base+0xfead367c> │ │ │ │ + bl feb7a23c <__bss_end__@@Base+0xfead369c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi 92707c <__bss_end__@@Base+0x880444> │ │ │ │ + blmi 927004 <__bss_end__@@Base+0x880464> │ │ │ │ stmdami r4!, {r0, r2, r9, sl, lr} │ │ │ │ adcvc pc, r4, #1325400064 @ 0x4f000000 │ │ │ │ vqshl.s8 q10, , q0 │ │ │ │ ldrbtmi r1, [r8], #-259 @ 0xfffffefd │ │ │ │ - stc2 7, cr15, [lr], {240} @ 0xf0 │ │ │ │ + ldc2 7, cr15, [r6, #-960]! @ 0xfffffc40 │ │ │ │ adcvc pc, r4, #1325400064 @ 0x4f000000 │ │ │ │ strmi r2, [r4], -r0, lsl #2 │ │ │ │ - svc 0x00d6f7df │ │ │ │ - blvc 61e75c <__bss_end__@@Base+0x577b24> │ │ │ │ + svc 0x00ecf7df │ │ │ │ + blvc 61e6e4 <__bss_end__@@Base+0x577b44> │ │ │ │ orrpl pc, r0, #20971520 @ 0x1400000 │ │ │ │ ldmib r1, {r0, r1, r2, r4, r8, sp, pc}^ │ │ │ │ @ instruction: 0xf8c30100 │ │ │ │ movwcs r4, #260 @ 0x104 │ │ │ │ teqeq r6, r4, asr #19 │ │ │ │ mrscs r2, (UNDEF: 0) │ │ │ │ movwpl lr, #2500 @ 0x9c4 │ │ │ │ @@ -32453,94 +32448,94 @@ │ │ │ │ vstr d7, [r4, #56] @ 0x38 │ │ │ │ vstr d7, [r4, #96] @ 0x60 │ │ │ │ vldmdblt r8!, {d7-d27} │ │ │ │ ... │ │ │ │ stcpl 5, cr1, [r1, #676]! @ 0x2a4 │ │ │ │ svccc 0x00dbecde │ │ │ │ @ instruction: 0xfffffe4d │ │ │ │ - muleq r2, r2, r8 │ │ │ │ + andeq r7, r2, lr, asr #21 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb85d68 <__bss_end__@@Base+0xfeadf130> │ │ │ │ + bl feb85cf0 <__bss_end__@@Base+0xfeadf150> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000fe8 │ │ │ │ cdpmi 3, 1, cr5, cr0, cr0, {4} │ │ │ │ - blhi 105ec30 <__bss_end__@@Base+0xfb7ff8> │ │ │ │ + blhi 105ebb8 <__bss_end__@@Base+0xfb8018> │ │ │ │ ldrbtmi r4, [lr], #-1541 @ 0xfffff9fb │ │ │ │ ldrdmi pc, [r4, -r3] │ │ │ │ stmdavs r3!, {r2, r3, r4, r7, r8, ip, sp, pc}^ │ │ │ │ - blmi 3516cc <__bss_end__@@Base+0x2aaa94> │ │ │ │ + blmi 351654 <__bss_end__@@Base+0x2aaab4> │ │ │ │ ldmpl r3!, {r3, r5, r9, sl, lr}^ │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ movwcs lr, #27076 @ 0x69c4 │ │ │ │ mcr2 7, 6, pc, cr10, cr15, {7} @ │ │ │ │ - bleq 25e7a4 <__bss_end__@@Base+0x1b7b6c> │ │ │ │ - blhi 15e7a8 <__bss_end__@@Base+0xb7b70> │ │ │ │ + bleq 25e72c <__bss_end__@@Base+0x1b7b8c> │ │ │ │ + blhi 15e730 <__bss_end__@@Base+0xb7b90> │ │ │ │ ldc 3, cr2, [sp], #4 │ │ │ │ rsbvs r8, r3, r2, lsl #22 │ │ │ │ @ instruction: 0xf7ffbd70 │ │ │ │ strmi pc, [r4], -r3, lsl #31 │ │ │ │ svclt 0x0000e7e7 │ │ │ │ - andeq r4, r3, lr, lsl #29 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ + andeq r4, r3, r6, lsl #30 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb85dc8 <__bss_end__@@Base+0xfeadf190> │ │ │ │ + bl feb85d50 <__bss_end__@@Base+0xfeadf1b0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000fe8 │ │ │ │ cdp 3, 11, cr5, cr0, cr0, {4} │ │ │ │ strmi r8, [r5], -r0, asr #22 │ │ │ │ ldrdmi pc, [r4, -r3] │ │ │ │ - blvs 90f7c8 <__bss_end__@@Base+0x868b90> │ │ │ │ + blvs 90f750 <__bss_end__@@Base+0x868bb0> │ │ │ │ movwcs fp, #6467 @ 0x1943 │ │ │ │ @ instruction: 0x63234628 │ │ │ │ mrc2 7, 7, pc, cr4, cr15, {7} │ │ │ │ - bleq 55e7f8 <__bss_end__@@Base+0x4b7bc0> │ │ │ │ - bleq 5de7fc <__bss_end__@@Base+0x537bc4> │ │ │ │ - blhi 45e800 <__bss_end__@@Base+0x3b7bc8> │ │ │ │ - blhi de4e8 <__bss_end__@@Base+0x378b0> │ │ │ │ + bleq 55e780 <__bss_end__@@Base+0x4b7be0> │ │ │ │ + bleq 5de784 <__bss_end__@@Base+0x537be4> │ │ │ │ + blhi 45e788 <__bss_end__@@Base+0x3b7be8> │ │ │ │ + blhi de470 <__bss_end__@@Base+0x378d0> │ │ │ │ @ instruction: 0xf7ffbd38 │ │ │ │ @ instruction: 0x4604ff59 │ │ │ │ svclt 0x0000e7eb │ │ │ │ orrpl pc, r0, #0, 10 │ │ │ │ ldrdcc pc, [r4, -r3] │ │ │ │ ldc 1, cr11, [r3, #332] @ 0x14c │ │ │ │ vldr d0, [r0, #40] @ 0x28 │ │ │ │ vldr d6, [r3, #608] @ 0x260 │ │ │ │ vadd.f64 d7, d0, d2 │ │ │ │ vnmul.f64 d0, d0, d6 │ │ │ │ ldrbmi r0, [r0, -r7, lsl #22]! │ │ │ │ - bleq de8a0 <__bss_end__@@Base+0x37c68> │ │ │ │ + bleq de828 <__bss_end__@@Base+0x37c88> │ │ │ │ svclt 0x00004770 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ ... │ │ │ │ orrpl pc, r0, #0, 10 │ │ │ │ ldrdcc pc, [r4, -r3] │ │ │ │ ldc 1, cr11, [r3, #332] @ 0x14c │ │ │ │ vldr d0, [r0, #96] @ 0x60 │ │ │ │ vldr d6, [r3, #616] @ 0x268 │ │ │ │ vadd.f64 d7, d0, d14 │ │ │ │ vnmul.f64 d0, d0, d6 │ │ │ │ ldrbmi r0, [r0, -r7, lsl #22]! │ │ │ │ - bleq 9e8d4 <__bss_start@@Base+0x43834> │ │ │ │ + bleq 9e85c <__bss_start@@Base+0x43854> │ │ │ │ svclt 0x00004770 │ │ │ │ ... │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdeq pc, [r4, -r0] │ │ │ │ mcrvs 1, 4, fp, cr0, cr8, {0} │ │ │ │ svclt 0x00183800 │ │ │ │ ldrbmi r2, [r0, -r1]! │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [r4, -r0] │ │ │ │ andcs fp, r0, #-1073741816 @ 0xc0000008 │ │ │ │ @ instruction: 0xf8c3669a │ │ │ │ subsvs r2, sl, ip, lsr #2 │ │ │ │ svclt 0x00004770 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb7a498 <__bss_end__@@Base+0xfead3860> │ │ │ │ + bl feb7a420 <__bss_end__@@Base+0xfead3880> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000ff8 │ │ │ │ strmi r5, [r4], -r0, lsl #7 │ │ │ │ ldrdcc pc, [r4, -r3] │ │ │ │ @ instruction: 0xf8d3b183 │ │ │ │ stmdblt r2!, {r4, r7, sp}^ │ │ │ │ andcs r2, r0, r1, lsl #2 │ │ │ │ @@ -32550,92 +32545,92 @@ │ │ │ │ stmib r3, {r3, r7, r8}^ │ │ │ │ @ instruction: 0xf8c30126 │ │ │ │ ldclt 1, cr2, [r0, #-256] @ 0xffffff00 │ │ │ │ mcr2 7, 7, pc, cr14, cr15, {7} @ │ │ │ │ strb r4, [sl, r3, lsl #12]! │ │ │ │ orrpl pc, r0, #0, 10 │ │ │ │ ldrdcc pc, [r4, -r3] │ │ │ │ - ldc 1, cr11, [pc, #268] @ 233ec │ │ │ │ + ldc 1, cr11, [pc, #268] @ 23374 │ │ │ │ andcs r7, r0, #5120 @ 0x1400 │ │ │ │ addscs pc, r0, r3, asr #17 │ │ │ │ smlalbtcs pc, r0, r3, r8 @ │ │ │ │ - blvc fe9de8f0 <__bss_end__@@Base+0xfe937cb8> │ │ │ │ + blvc fe9de878 <__bss_end__@@Base+0xfe937cd8> │ │ │ │ svclt 0x00004770 │ │ │ │ ... │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdeq pc, [r4, -r0] │ │ │ │ @ instruction: 0xf8d0b120 │ │ │ │ stmdacc r0, {r4, r7} │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ svclt 0x00004770 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb7a51c <__bss_end__@@Base+0xfead38e4> │ │ │ │ + bl feb7a4a4 <__bss_end__@@Base+0xfead3904> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000ff8 │ │ │ │ strmi r5, [r4], -r0, lsl #7 │ │ │ │ ldrdcc pc, [r4, -r3] │ │ │ │ @ instruction: 0xf8d3b163 │ │ │ │ @ instruction: 0xb1822090 │ │ │ │ andcs r2, r0, r0, lsl #4 │ │ │ │ @ instruction: 0xf8c32100 │ │ │ │ @ instruction: 0xf8c32090 │ │ │ │ stmib r4, {r6, r8, sp}^ │ │ │ │ ldclt 1, cr0, [r0, #-664] @ 0xfffffd68 │ │ │ │ mrc2 7, 5, pc, cr0, cr15, {7} │ │ │ │ @ instruction: 0x2090f8d0 │ │ │ │ - bcs 34b60 │ │ │ │ - ldc 1, cr13, [pc, #988] @ 23734 │ │ │ │ + bcs 34ae8 │ │ │ │ + ldc 1, cr13, [pc, #988] @ 236bc │ │ │ │ andcs r7, r1, #7168 @ 0x1c00 │ │ │ │ ldrdeq lr, [r8, r4] │ │ │ │ smlawteq r6, r3, r9, lr │ │ │ │ addscs pc, r0, r3, asr #17 │ │ │ │ stc 2, cr2, [r3] │ │ │ │ @ instruction: 0xf8c37b28 │ │ │ │ ldclt 1, cr2, [r0, #-256] @ 0xffffff00 │ │ │ │ ... │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [r4, -r0] │ │ │ │ ldc 1, cr11, [r3, #76] @ 0x4c │ │ │ │ ldrbmi r0, [r0, -sl, lsr #22]! │ │ │ │ - bleq 9ea0c <__bss_start@@Base+0x4396c> │ │ │ │ + bleq 9e994 <__bss_start@@Base+0x4398c> │ │ │ │ svclt 0x00004770 │ │ │ │ ... │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb85fb8 <__bss_end__@@Base+0xfeadf380> │ │ │ │ + bl feb85f40 <__bss_end__@@Base+0xfeadf3a0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000fe0 │ │ │ │ strmi r5, [r5], -r0, lsl #7 │ │ │ │ ldrdmi pc, [r4, -r3] │ │ │ │ @ instruction: 0xf8d4b35c │ │ │ │ - bllt ef680 <__bss_end__@@Base+0x48a48> │ │ │ │ - blhi edea18 <__bss_end__@@Base+0xe37de0> │ │ │ │ - blhi ff05ee9c <__bss_end__@@Base+0xfefb8264> │ │ │ │ - blx 45ef90 <__bss_end__@@Base+0x3b8358> │ │ │ │ - ldc 4, cr13, [pc, #112] @ 23440 │ │ │ │ + bllt ef608 <__bss_end__@@Base+0x48a68> │ │ │ │ + blhi ede9a0 <__bss_end__@@Base+0xe37e00> │ │ │ │ + blhi ff05ee24 <__bss_end__@@Base+0xfefb8284> │ │ │ │ + blx 45ef18 <__bss_end__@@Base+0x3b8378> │ │ │ │ + ldc 4, cr13, [pc, #112] @ 233c8 │ │ │ │ vmov.32 r9, d6[1] │ │ │ │ vdiv.f64 d7, d8, d0 │ │ │ │ vadd.f64 d0, d0, d9 │ │ │ │ @ instruction: 0xf7df0b07 │ │ │ │ - cdp 14, 2, cr14, cr0, cr4, {4} │ │ │ │ + mcr 14, 1, lr, cr0, cr10, {4} │ │ │ │ andcs r0, r0, #9216 @ 0x2400 │ │ │ │ andcs r2, r1, r0, lsl #6 │ │ │ │ @ instruction: 0xf8c42100 │ │ │ │ @ instruction: 0xf8c400b0 │ │ │ │ stmib r4, {r2, r3, r4, r5, r8, ip}^ │ │ │ │ stc 3, cr2, [r4, #200] @ 0xc8 │ │ │ │ vstr d0, [r4, #184] @ 0xb8 │ │ │ │ vpop {d8-d31} │ │ │ │ vldmdblt r8!, {d8-d9} │ │ │ │ - bleq 1dea88 <__bss_end__@@Base+0x137e50> │ │ │ │ - blhi 105eed0 <__bss_end__@@Base+0xfb8298> │ │ │ │ + bleq 1dea10 <__bss_end__@@Base+0x137e70> │ │ │ │ + blhi 105ee58 <__bss_end__@@Base+0xfb82b8> │ │ │ │ @ instruction: 0xf7ffe7e9 │ │ │ │ strmi pc, [r4], -fp, asr #28 │ │ │ │ svclt 0x0000e7cf │ │ │ │ - blx ff12d0ac <__bss_end__@@Base+0xff086474> │ │ │ │ + blx ff12d034 <__bss_end__@@Base+0xff086494> │ │ │ │ eormi lr, r0, sl, asr #1 │ │ │ │ ... │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [r4, -r0] │ │ │ │ @ instruction: 0xf8d3b13b │ │ │ │ strhlt r2, [r2, -r0]! │ │ │ │ @ instruction: 0xf8c32200 │ │ │ │ @@ -32655,103 +32650,103 @@ │ │ │ │ @ instruction: 0xf8c320b0 │ │ │ │ @ instruction: 0x4770213c │ │ │ │ svclt 0x008ef7ff │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [r4, -r0] │ │ │ │ @ instruction: 0xf8d3b12b │ │ │ │ ldrhlt r2, [r2, -r0] │ │ │ │ - bleq bdeae0 <__bss_end__@@Base+0xb37ea8> │ │ │ │ - ldc 7, cr4, [pc, #448] @ 23658 │ │ │ │ + bleq bdea68 <__bss_end__@@Base+0xb37ec8> │ │ │ │ + ldc 7, cr4, [pc, #448] @ 235e0 │ │ │ │ ldrbmi r0, [r0, -r1, lsl #22]! │ │ │ │ ... │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb860b8 <__bss_end__@@Base+0xfeadf480> │ │ │ │ + bl feb86040 <__bss_end__@@Base+0xfeadf4a0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000ff0 │ │ │ │ @ instruction: 0xf8d35380 │ │ │ │ @ instruction: 0xb1a44104 │ │ │ │ - blhi 35eb40 <__bss_end__@@Base+0x2b7f08> │ │ │ │ - blvs 5efa0 <__bss_start@@Base+0x3f00> │ │ │ │ - blvc bdeb1c <__bss_end__@@Base+0xb37ee4> │ │ │ │ - blvc 25edac <__bss_end__@@Base+0x1b8174> │ │ │ │ - bleq 25eef0 <__bss_end__@@Base+0x1b82b8> │ │ │ │ - bleq 1ded98 <__bss_end__@@Base+0x138160> │ │ │ │ - mcr 7, 0, pc, cr6, cr15, {6} @ │ │ │ │ - bleq 25ed60 <__bss_end__@@Base+0x1b8128> │ │ │ │ - blhi de7d8 <__bss_end__@@Base+0x37ba0> │ │ │ │ - bleq bdeaf8 <__bss_end__@@Base+0xb37ec0> │ │ │ │ + blhi 35eac8 <__bss_end__@@Base+0x2b7f28> │ │ │ │ + blvs 5ef28 <__bss_start@@Base+0x3f20> │ │ │ │ + blvc bdeaa4 <__bss_end__@@Base+0xb37f04> │ │ │ │ + blvc 25ed34 <__bss_end__@@Base+0x1b8194> │ │ │ │ + bleq 25ee78 <__bss_end__@@Base+0x1b82d8> │ │ │ │ + bleq 1ded20 <__bss_end__@@Base+0x138180> │ │ │ │ + mrc 7, 0, APSR_nzcv, cr12, cr15, {6} │ │ │ │ + bleq 25ece8 <__bss_end__@@Base+0x1b8148> │ │ │ │ + blhi de760 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<__bss_end__@@Base+0xfe3b821c> │ │ │ │ + blvs ddeba8 <__bss_end__@@Base+0xd38008> │ │ │ │ + blcc 5f03c <__bss_start@@Base+0x4034> │ │ │ │ + blpl 41ebe4 <__bss_end__@@Base+0x378044> │ │ │ │ + blmi 45ebe8 <__bss_end__@@Base+0x3b8048> │ │ │ │ + blvs 19ee08 <__bss_end__@@Base+0xf8268> │ │ │ │ + blvc 15ef8c <__bss_end__@@Base+0xb83ec> │ │ │ │ + blvc 11ee54 <__bss_end__@@Base+0x782b4> │ │ │ │ + blvc ff21f170 <__bss_end__@@Base+0xff1785d0> │ │ │ │ + bcc fe45eddc <__bss_end__@@Base+0xfe3b823c> │ │ │ │ vstrle d2, [sl, #-20] @ 0xffffffec │ │ │ │ vmla.f64 d3, d7, d5 │ │ │ │ @ instruction: 0xeeb83a10 │ │ │ │ vnmul.f64 d7, d23, d7 │ │ │ │ vdiv.f64 d7, d7, d4 │ │ │ │ vstr d6, [r2, #20] │ │ │ │ vstrlt d6, [r8, #-216] @ 0xffffff28 │ │ │ │ @@ -32761,16 +32756,16 @@ │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [r4, -r0] │ │ │ │ ldc 1, cr11, [r3, #588] @ 0x24c │ │ │ │ vmov.u16 r6, d6[2] │ │ │ │ - vldr d5, [pc] @ 23640 │ │ │ │ - vldr d7, [pc, #36] @ 23668 │ │ │ │ + vldr d5, [pc] @ 235c8 │ │ │ │ + vldr d7, [pc, #36] @ 235f0 │ │ │ │ vmul.f64 d4, d6, d10 │ │ │ │ vdiv.f64 d6, d6, d7 │ │ │ │ vadd.f64 d7, d7, d4 │ │ │ │ vmov.f64 d23, #213 @ 0xbea80000 -0.3281250 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ @ instruction: 0x47700a90 │ │ │ │ @ instruction: 0x47702019 │ │ │ │ @@ -32792,16 +32787,16 @@ │ │ │ │ andcs r4, r0, #112, 14 @ 0x1c00000 │ │ │ │ sbcscs pc, r0, r3, asr #17 │ │ │ │ @ instruction: 0x4770631a │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [r4, -r0] │ │ │ │ @ instruction: 0xf8d3b12b │ │ │ │ ldrsblt r2, [r2, -r0] │ │ │ │ - bleq e5ed08 <__bss_end__@@Base+0xdb80d0> │ │ │ │ - ldc 7, cr4, [pc, #448] @ 23880 │ │ │ │ + bleq e5ec90 <__bss_end__@@Base+0xdb80f0> │ │ │ │ + ldc 7, cr4, [pc, #448] @ 23808 │ │ │ │ ldrbmi r0, [r0, -r1, lsl #22]! │ │ │ │ ... │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [r4, -r0] │ │ │ │ @ instruction: 0xf8d3b113 │ │ │ │ stmdblt r2, {r2, r4, r8, sp} │ │ │ │ andcs r4, r0, #112, 14 @ 0x1c00000 │ │ │ │ @@ -32828,15 +32823,15 @@ │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdeq pc, [r4, -r0] │ │ │ │ @ instruction: 0xf8d0b120 │ │ │ │ stmdacc r0, {r4, r5, r6, r7} │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ svclt 0x00004770 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb7a950 <__bss_end__@@Base+0xfead3d18> │ │ │ │ + bl feb7a8d8 <__bss_end__@@Base+0xfead3d38> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000ff0 │ │ │ │ strmi r5, [r5], -r0, lsl #9 │ │ │ │ ldrdvs pc, [r4, -r4] │ │ │ │ @ instruction: 0xf8d6b386 │ │ │ │ ldrtmi r3, [r4], -r8, lsr #2 │ │ │ │ ldcllt 1, cr11, [r0, #-12]! │ │ │ │ @@ -32860,24 +32855,24 @@ │ │ │ │ andcs r2, r0, #144 @ 0x90 │ │ │ │ smlawteq r6, r4, r9, lr │ │ │ │ @ instruction: 0x2328e9c4 │ │ │ │ @ instruction: 0xf8c62301 │ │ │ │ ldcllt 1, cr3, [r0, #-160]! @ 0xffffff60 │ │ │ │ ldc2l 7, cr15, [r2], #-1020 @ 0xfffffc04 │ │ │ │ ldrdcc pc, [r8, -r0]! │ │ │ │ - blcs 34fe8 │ │ │ │ + blcs 34f70 │ │ │ │ @ instruction: 0xf8d4d1cb │ │ │ │ stccs 1, cr4, [r0], {4} │ │ │ │ strtmi sp, [r8], -r8, asr #3 │ │ │ │ @ instruction: 0xff92f7ff │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ strmi pc, [r4], -r3, ror #24 │ │ │ │ svclt 0x0000e7d8 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb7a9f4 <__bss_end__@@Base+0xfead3dbc> │ │ │ │ + bl feb7a97c <__bss_end__@@Base+0xfead3ddc> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000ff0 │ │ │ │ strmi r5, [r4], -r0, lsl #11 │ │ │ │ ldrdcc pc, [r4, -r5] │ │ │ │ @ instruction: 0xf8d3b163 │ │ │ │ cmplt r2, r8, lsr #2 │ │ │ │ ldrdeq pc, [r4, -r5] │ │ │ │ @@ -32887,113 +32882,113 @@ │ │ │ │ ldclt 3, cr6, [r8, #-12]! │ │ │ │ mcrr2 7, 15, pc, r4, cr15 @ │ │ │ │ strb r4, [lr, r3, lsl #12]! │ │ │ │ @ instruction: 0xf7ff4620 │ │ │ │ @ instruction: 0xe7f4fc3f │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8644c <__bss_end__@@Base+0xfeadf814> │ │ │ │ + bl feb863d4 <__bss_end__@@Base+0xfeadf834> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000fe0 │ │ │ │ strmi r5, [r5], -r0, lsl #7 │ │ │ │ ldrdmi pc, [r4, -r3] │ │ │ │ cdpvs 3, 10, cr11, cr3, cr12, {5} │ │ │ │ strtmi fp, [r8], -r3, lsl #23 │ │ │ │ - blls 71eed4 <__bss_end__@@Base+0x67829c> │ │ │ │ + blls 71ee5c <__bss_end__@@Base+0x6782bc> │ │ │ │ @ instruction: 0xff54f7ff │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ ldc 15, cr15, [r5, #788] @ 0x314 │ │ │ │ vldr d5, [r5, #280] @ 0x118 │ │ │ │ vmov.u16 r8, d6[2] │ │ │ │ - vldr d7, [pc] @ 23870 │ │ │ │ + vldr d7, [pc] @ 237f8 │ │ │ │ movwcs r6, #6935 @ 0x1b17 │ │ │ │ - bleq 29f28c <__bss_end__@@Base+0x1f8654> │ │ │ │ + bleq 29f214 <__bss_end__@@Base+0x1f8674> │ │ │ │ cdp 6, 11, cr6, cr0, cr3, {5} │ │ │ │ vcmpe.f64 d5, d8 │ │ │ │ vsqrt.f64 d21, d6 │ │ │ │ svclt 0x0058fa10 │ │ │ │ strbtvs r2, [r3], r0, lsl #6 │ │ │ │ - bleq 21f150 <__bss_end__@@Base+0x178518> │ │ │ │ - stc 7, cr15, [sl], #-892 @ 0xfffffc84 │ │ │ │ - blvc 41ef14 <__bss_end__@@Base+0x3782dc> │ │ │ │ - bleq 29f11c <__bss_end__@@Base+0x1f84e4> │ │ │ │ + bleq 21f0d8 <__bss_end__@@Base+0x178538> │ │ │ │ + mcrr 7, 13, pc, r0, cr15 @ │ │ │ │ + blvc 41ee9c <__bss_end__@@Base+0x3782fc> │ │ │ │ + bleq 29f0a4 <__bss_end__@@Base+0x1f8504> │ │ │ │ movwcs r2, #512 @ 0x200 │ │ │ │ tstcs lr, #196, 18 @ 0x310000 │ │ │ │ - blhi 121f148 <__bss_end__@@Base+0x1178510> │ │ │ │ - bleq 75eebc <__bss_end__@@Base+0x6b8284> │ │ │ │ - blhi 85eec0 <__bss_end__@@Base+0x7b8288> │ │ │ │ - blhi 8deec4 <__bss_end__@@Base+0x83828c> │ │ │ │ - blhi 15ebac <__bss_end__@@Base+0xb7f74> │ │ │ │ + blhi 121f0d0 <__bss_end__@@Base+0x1178530> │ │ │ │ + bleq 75ee44 <__bss_end__@@Base+0x6b82a4> │ │ │ │ + blhi 85ee48 <__bss_end__@@Base+0x7b82a8> │ │ │ │ + blhi 8dee4c <__bss_end__@@Base+0x8382ac> │ │ │ │ + blhi 15eb34 <__bss_end__@@Base+0xb7f94> │ │ │ │ @ instruction: 0xf7ffbd38 │ │ │ │ @ instruction: 0x4604fbf7 │ │ │ │ svclt 0x0000e7c5 │ │ │ │ strbtmi r4, [fp], -pc, asr #18 │ │ │ │ eorsmi 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0x1400000 │ │ │ │ ldrdmi pc, [r4, -r3] │ │ │ │ cdp 3, 11, cr11, cr0, cr4, {1} │ │ │ │ - vldr d7, [pc, #800] @ 23c48 │ │ │ │ + vldr d7, [pc, #800] @ 23bd0 │ │ │ │ vmov.32 r6, d4[1] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ svclt 0x004cfa10 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ ldrle r6, [r2, #-1763] @ 0xfffff91d │ │ │ │ - blvs 11def94 <__bss_end__@@Base+0x113835c> │ │ │ │ - blvc 5f41c <__bss_start@@Base+0x437c> │ │ │ │ - blhi 41efc4 <__bss_end__@@Base+0x37838c> │ │ │ │ - bleq 25f364 <__bss_end__@@Base+0x1b872c> │ │ │ │ - bleq 21f210 <__bss_end__@@Base+0x1785d8> │ │ │ │ - bl ff2e18d0 <__bss_end__@@Base+0xff23ac98> │ │ │ │ - bleq 25f1d8 <__bss_end__@@Base+0x1b85a0> │ │ │ │ - blhi dec50 <__bss_end__@@Base+0x38018> │ │ │ │ - bleq 75ef70 <__bss_end__@@Base+0x6b8338> │ │ │ │ + blvs 11def1c <__bss_end__@@Base+0x113837c> │ │ │ │ + blvc 5f3a4 <__bss_start@@Base+0x439c> │ │ │ │ + blhi 41ef4c <__bss_end__@@Base+0x3783ac> │ │ │ │ + bleq 25f2ec <__bss_end__@@Base+0x1b874c> │ │ │ │ + bleq 21f198 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│ mvnslt r4, r3, lsr #12 │ │ │ │ ldrsbtcs pc, [r0], #131 @ 0x83 @ │ │ │ │ @ instruction: 0x4628b97a │ │ │ │ @@ -33041,20 +33036,20 @@ │ │ │ │ @ instruction: 0xf8d3bd70 │ │ │ │ andcs r1, r0, #208 @ 0xd0 │ │ │ │ rscscs pc, r0, r3, asr #17 │ │ │ │ teqpcs r4, r3, asr #17 @ p-variant is OBSOLETE │ │ │ │ rscle r2, r6, r0, lsl #18 │ │ │ │ sbcscs pc, r0, r3, asr #17 │ │ │ │ @ instruction: 0xe7e2631a │ │ │ │ - blx 161aa2 <__bss_end__@@Base+0xbae6a> │ │ │ │ + blx 161a2a <__bss_end__@@Base+0xbae8a> │ │ │ │ ldrdcc pc, [r4, -r6] │ │ │ │ - blcs 352bc │ │ │ │ + blcs 35244 │ │ │ │ @ instruction: 0xe7d7d0db │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb7acb8 <__bss_end__@@Base+0xfead4080> │ │ │ │ + bl feb7ac40 <__bss_end__@@Base+0xfead40a0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000ff0 │ │ │ │ strmi r5, [r5], -r0, lsl #13 │ │ │ │ ldrdmi pc, [r4, -r6] │ │ │ │ eorsle r2, lr, r0, lsl #24 │ │ │ │ ldrsbtcc pc, [r0], #132 @ 0x84 @ │ │ │ │ ldcllt 1, cr11, [r0, #-12]! │ │ │ │ @@ -33074,15 +33069,15 @@ │ │ │ │ @ instruction: 0x3090f8d0 │ │ │ │ @ instruction: 0xed95b963 │ │ │ │ andcs r7, r1, #136, 22 @ 0x22000 │ │ │ │ smlalbtcc pc, r0, r0, r8 @ │ │ │ │ @ instruction: 0xf8c02300 │ │ │ │ andcs r2, r0, #144 @ 0x90 │ │ │ │ @ instruction: 0x2328e9c0 │ │ │ │ - blvc 9df128 <__bss_end__@@Base+0x9384f0> │ │ │ │ + blvc 9df0b0 <__bss_end__@@Base+0x938510> │ │ │ │ movwcs r2, #512 @ 0x200 │ │ │ │ andcs r2, r1, r0, lsl #2 │ │ │ │ tstpne r0, r4, asr #17 @ p-variant is OBSOLETE │ │ │ │ rscseq pc, r0, r4, asr #17 │ │ │ │ teqpne r4, r4, asr #17 @ p-variant is OBSOLETE │ │ │ │ teqcs lr, #196, 18 @ 0x310000 │ │ │ │ movtcs lr, #2500 @ 0x9c4 │ │ │ │ @@ -33090,25 +33085,25 @@ │ │ │ │ @ instruction: 0xf7ffbd70 │ │ │ │ @ instruction: 0xf8d0faaf │ │ │ │ @ instruction: 0x460430f0 │ │ │ │ @ instruction: 0xd1bc2b00 │ │ │ │ ldrdcc pc, [r4, -r6] │ │ │ │ sbcle r2, sl, r0, lsl #22 │ │ │ │ @ instruction: 0x4628e7b9 │ │ │ │ - blx fe8e1b64 <__bss_end__@@Base+0xfe83af2c> │ │ │ │ + blx fe8e1aec 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-r6] │ │ │ │ ldmpl r3, {r3, r4, r5, r6, r7, sl, lr}^ │ │ │ │ movwls r6, #22555 @ 0x581b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ @ instruction: 0xf8d582d6 │ │ │ │ @ instruction: 0x460430b0 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ ldc 2, cr8, [r5, #896] @ 0x380 │ │ │ │ - blmi f669dc <__bss_end__@@Base+0xebfda4> │ │ │ │ - bleq 105f7ec <__bss_end__@@Base+0xfb8bb4> │ │ │ │ + blmi f66964 <__bss_end__@@Base+0xebfdc4> │ │ │ │ + bleq 105f774 <__bss_end__@@Base+0xfb8bd4> │ │ │ │ andvc pc, r3, r8, asr r8 @ │ │ │ │ - blx 45f8e4 <__bss_end__@@Base+0x3b8cac> │ │ │ │ - blcs 5f380 <__bss_start@@Base+0x42e0> │ │ │ │ + blx 45f86c <__bss_end__@@Base+0x3b8ccc> │ │ │ │ + blcs 5f308 <__bss_start@@Base+0x4300> │ │ │ │ mvnshi pc, #0 │ │ │ │ - bleq 105f5f4 <__bss_end__@@Base+0xfb89bc> │ │ │ │ - blvc 5f808 <__bss_start@@Base+0x4768> │ │ │ │ - bleq ff21f804 <__bss_end__@@Base+0xff178bcc> │ │ │ │ - blx 45f8fc <__bss_end__@@Base+0x3b8cc4> │ │ │ │ + bleq 105f57c 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muleq r3, r2, r3 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r4, r3, r8, lsl #7 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ @ instruction: 0xf7ff4620 │ │ │ │ @ instruction: 0xf8d6fc79 │ │ │ │ stccs 1, cr5, [r0, #-16] │ │ │ │ cmnphi sl, #0 @ p-variant is OBSOLETE │ │ │ │ - blvc 7df474 <__bss_end__@@Base+0x73883c> │ │ │ │ - blvs 5f480 <__bss_start@@Base+0x43e0> │ │ │ │ - blvc 105f8fc <__bss_end__@@Base+0xfb8cc4> │ │ │ │ - blx 45f9f0 <__bss_end__@@Base+0x3b8db8> │ │ │ │ + blvc 7df3fc <__bss_end__@@Base+0x73885c> │ │ │ │ + blvs 5f408 <__bss_start@@Base+0x4400> │ │ │ │ + blvc 105f884 <__bss_end__@@Base+0xfb8ce4> │ │ │ │ + blx 45f978 <__bss_end__@@Base+0x3b8dd8> │ │ │ │ cdp 0, 3, cr13, cr6, cr8, {0} │ │ │ │ - vldr d7, [pc, #284] @ 23f50 │ │ │ │ + vldr d7, [pc, #284] @ 23ed8 │ │ │ │ vcmpe.f64 d5, d20 │ │ │ │ vsqrt.f64 d23, d5 │ │ │ │ strbtle pc, [r5], #-2576 @ 0xfffff5f0 @ │ │ │ │ andcs r6, r0, #2736 @ 0xab0 │ │ │ │ - blvs 7df45c <__bss_end__@@Base+0x738824> │ │ │ │ + blvs 7df3e4 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│ │ @ instruction: 0xf43f2b00 │ │ │ │ ldc 13, cr10, [r5, #512] @ 0x200 │ │ │ │ vcmp.f64 d7, #0.0 │ │ │ │ vneg.f64 d23, d0 │ │ │ │ @ instruction: 0xf000fa10 │ │ │ │ ldc 1, cr8, [r7, #140] @ 0x8c │ │ │ │ - vldr d8, [pc] @ 242f4 │ │ │ │ + vldr d8, [pc] @ 2427c │ │ │ │ vmov.32 r6, d24[1] │ │ │ │ vcmp.f64 d8, d7 │ │ │ │ vsqrt.f64 d24, d6 │ │ │ │ @ instruction: 0xf53ffa10 │ │ │ │ @ instruction: 0xf8d4ad6c │ │ │ │ movwcs r9, #68 @ 0x44 │ │ │ │ teqpcc r0, r5, asr #17 @ p-variant is OBSOLETE │ │ │ │ @@ -33588,42 +33583,42 @@ │ │ │ │ tstphi r1, r0 @ p-variant is OBSOLETE │ │ │ │ strbmi sl, [r8], -r2, lsl #18 │ │ │ │ @ instruction: 0xf8d0f00b │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ @ instruction: 0xf8d68311 │ │ │ │ cmplt r5, r4, lsl #2 │ │ │ │ @ instruction: 0x3114f8d5 │ │ │ │ - blcs 35dd8 │ │ │ │ + blcs 35d60 │ │ │ │ tstphi r1, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ svceq 0x0000f1b9 │ │ │ │ strtmi sp, [r0], -r3, lsl #2 │ │ │ │ mrc2 7, 5, pc, cr4, cr14, {7} │ │ │ │ @ instruction: 0xf8d94681 │ │ │ │ - blcs 3070c │ │ │ │ + blcs 30694 │ │ │ │ stclge 4, cr15, [r1, #-252]! @ 0xffffff04 │ │ │ │ - blls 105f9b8 <__bss_end__@@Base+0xfb8d80> │ │ │ │ - blvc 5f9b4 <__bss_start@@Base+0x4914> │ │ │ │ - blls 105fe30 <__bss_end__@@Base+0xfb91f8> │ │ │ │ - blx 45ff24 <__bss_end__@@Base+0x3b92ec> │ │ │ │ + blls 105f940 <__bss_end__@@Base+0xfb8da0> │ │ │ │ + blvc 5f93c <__bss_start@@Base+0x4934> │ │ │ │ + blls 105fdb8 <__bss_end__@@Base+0xfb9218> │ │ │ │ + blx 45feac <__bss_end__@@Base+0x3b930c> │ │ │ │ adchi pc, r7, #0 │ │ │ │ - blls 129fc44 <__bss_end__@@Base+0x11f900c> │ │ │ │ - blvs 5fe44 <__bss_start@@Base+0x4da4> │ │ │ │ - blls ff1dfe40 <__bss_end__@@Base+0xff139208> │ │ │ │ - blx 45ff38 <__bss_end__@@Base+0x3b9300> │ │ │ │ + blls 129fbcc <__bss_end__@@Base+0x11f902c> │ │ │ │ + blvs 5fdcc <__bss_start@@Base+0x4dc4> │ │ │ │ + blls ff1dfdc8 <__bss_end__@@Base+0xff139228> │ │ │ │ + blx 45fec0 <__bss_end__@@Base+0x3b9320> │ │ │ │ stclge 5, cr15, [sp, #-252] @ 0xffffff04 │ │ │ │ - blhi 11df9cc <__bss_end__@@Base+0x1138d94> │ │ │ │ + blhi 11df954 <__bss_end__@@Base+0x1138db4> │ │ │ │ stc 3, cr2, [r9] │ │ │ │ strtmi r7, [r0], -r0, asr #22 │ │ │ │ teqpcc r4, r9, asr #17 @ p-variant is OBSOLETE │ │ │ │ cdp2 0, 15, cr15, cr8, cr0, {1} │ │ │ │ - bleq 105fc70 <__bss_end__@@Base+0xfb9038> │ │ │ │ - blvc 1cdfa10 <__bss_end__@@Base+0x1c38dd8> │ │ │ │ + bleq 105fbf8 <__bss_end__@@Base+0xfb9058> │ │ │ │ + blvc 1cdf998 <__bss_end__@@Base+0x1c38df8> │ │ │ │ msrcc CPSR_fs, #212, 16 @ 0xd40000 │ │ │ │ - blvs 1cdfa18 <__bss_end__@@Base+0x1c38de0> │ │ │ │ - blhi 21fda0 <__bss_end__@@Base+0x179168> │ │ │ │ + blvs 1cdf9a0 <__bss_end__@@Base+0x1c38e00> │ │ │ │ + blhi 21fd28 <__bss_end__@@Base+0x179188> │ │ │ │ ldc 12, cr6, [r3, #404] @ 0x194 │ │ │ │ vldr d3, [r3, #616] @ 0x268 │ │ │ │ vldr d4, [r3, #680] @ 0x2a8 │ │ │ │ vadd.f64 d5, d24, d30 │ │ │ │ vsub.f64 d8, d8, d3 │ │ │ │ vsub.f64 d8, d8, d4 │ │ │ │ vcmp.f64 d8, d5 │ │ │ │ @@ -33631,111 +33626,111 @@ │ │ │ │ vpmin.u8 d31, d0, d0 │ │ │ │ stccs 2, cr8, [r0, #-288] @ 0xfffffee0 │ │ │ │ stcge 4, cr15, [r0, #-252]! @ 0xffffff04 │ │ │ │ strtmi r4, [r8], -r9, ror #12 │ │ │ │ @ instruction: 0xf8bef00b │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ ldc 13, cr10, [sp, #100] @ 0x64 │ │ │ │ - vldr d11, [pc] @ 243e0 │ │ │ │ + vldr d11, [pc] @ 24368 │ │ │ │ vldr d6, [r9, #396] @ 0x18c │ │ │ │ vmov.u16 r7, d4[2] │ │ │ │ vsqrt.f64 d27, d6 │ │ │ │ vpmin.u8 d15, d0, d0 │ │ │ │ - ldc 5, cr8, [pc, #220] @ 244d0 │ │ │ │ + ldc 5, cr8, [pc, #220] @ 24458 │ │ │ │ vsub.f64 d6, d11, d16 │ │ │ │ vcvtb.f16.f64 s14, d7 │ │ │ │ - vldr d3, [pc, #56] @ 24438 │ │ │ │ + vldr d3, [pc, #56] @ 243c0 │ │ │ │ @ instruction: 0xee2b5b5f │ │ │ │ vdiv.f64 d6, d7, d6 │ │ │ │ vdiv.f64 d4, d6, d9 │ │ │ │ vmov.f64 d7, #67 @ 0x3e180000 0.1484375 │ │ │ │ vsqrt.f64 d23, d5 │ │ │ │ vmov.i16 d15, #0 @ 0x0000 │ │ │ │ mrc 5, 5, r8, cr0, cr11, {1} │ │ │ │ vsub.f64 d7, d4, d5 │ │ │ │ vmov.f64 d9, d7 │ │ │ │ - vldr d7, [pc, #812] @ 24754 │ │ │ │ + vldr d7, [pc, #812] @ 246dc │ │ │ │ @ instruction: 0xeeb26b57 │ │ │ │ vmov.f64 d5, #68 @ 0x3e200000 0.1562500 │ │ │ │ vnmul.f64 d7, d25, d6 │ │ │ │ vmov.f64 d25, #21 @ 0x40a80000 5.250 │ │ │ │ vpmin.u8 d15, d0, d0 │ │ │ │ - ldc 5, cr8, [pc, #220] @ 2451c │ │ │ │ + ldc 5, cr8, [pc, #220] @ 244a4 │ │ │ │ @ instruction: 0xeeb47b53 │ │ │ │ vsqrt.f64 d25, d7 │ │ │ │ vmov.i16 d31, #0 @ 0x0000 │ │ │ │ - ldc 5, cr8, [pc, #568] @ 24688 │ │ │ │ + ldc 5, cr8, [pc, #568] @ 24610 │ │ │ │ @ instruction: 0xeeb47b51 │ │ │ │ vsqrt.f64 d25, d7 │ │ │ │ svclt 0x0088fa10 │ │ │ │ - blls 121ff20 <__bss_end__@@Base+0x11792e8> │ │ │ │ + blls 121fea8 <__bss_end__@@Base+0x1179308> │ │ │ │ @ instruction: 0xf7ff4620 │ │ │ │ @ instruction: 0xf8d6fa93 │ │ │ │ ldc 1, cr3, [r4, #16] │ │ │ │ - vldr d10, [pc, #232] @ 24558 │ │ │ │ + vldr d10, [pc, #232] @ 244e0 │ │ │ │ vstr d7, [r3, #236] @ 0xec │ │ │ │ @ instruction: 0xf8d99b38 │ │ │ │ mcr 1, 1, r3, cr10, cr0, {0} │ │ │ │ vstr d10, [r9, #28] │ │ │ │ - blcs 5317c │ │ │ │ + blcs 53104 │ │ │ │ ldrbhi pc, [r9, #-0]! @ │ │ │ │ stmdbge r2, {r3, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf880f00b │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ ldc 3, cr8, [sp, #196] @ 0xc4 │ │ │ │ - vldr d7, [pc, #8] @ 244a4 │ │ │ │ - vldr d6, [pc, #256] @ 245a0 │ │ │ │ - vldr d4, [pc, #260] @ 245a8 │ │ │ │ + vldr d7, [pc, #8] @ 2442c │ │ │ │ + vldr d6, [pc, #256] @ 24528 │ │ │ │ + vldr d4, [pc, #260] @ 24530 │ │ │ │ vnmul.f64 d5, d7, d2 │ │ │ │ vdiv.f64 d7, d7, d6 │ │ │ │ vmov.f64 d6, #68 @ 0x3e200000 0.1562500 │ │ │ │ vstr d6, [sp, #788] @ 0x314 │ │ │ │ vmov.f64 d22, #18 @ 0x40900000 4.5 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ - ldc 5, cr8, [pc, #640] @ 24740 │ │ │ │ + ldc 5, cr8, [pc, #640] @ 246c8 │ │ │ │ vmov.u16 r4, d7[2] │ │ │ │ - vldr d7, [pc] @ 244c8 │ │ │ │ - vldr d5, [pc, #244] @ 245c0 │ │ │ │ + vldr d7, [pc] @ 24450 │ │ │ │ + vldr d5, [pc, #244] @ 24548 │ │ │ │ vmla.f64 d0, d6, d18 │ │ │ │ vmul.f64 d7, d10, d4 │ │ │ │ vmul.f64 d5, d5, d5 │ │ │ │ vmul.f64 d0, d7, d0 │ │ │ │ vmov.f64 d7, #69 @ 0x3e280000 0.1640625 │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ - blle 262d28 <__bss_end__@@Base+0x1bc0f0> │ │ │ │ - blvc ff05ffc0 <__bss_end__@@Base+0xfefb9388> │ │ │ │ - bleq d9fb6c <__bss_end__@@Base+0xcf8f34> │ │ │ │ - blx 4600b8 <__bss_end__@@Base+0x3b9480> │ │ │ │ + blle 262cb0 <__bss_end__@@Base+0x1bc110> │ │ │ │ + blvc ff05ff48 <__bss_end__@@Base+0xfefb93a8> │ │ │ │ + bleq d9faf4 <__bss_end__@@Base+0xcf8f54> │ │ │ │ + blx 460040 <__bss_end__@@Base+0x3b94a0> │ │ │ │ mrc 15, 5, fp, cr0, cr8, {4} │ │ │ │ strtmi r0, [r0], -r7, asr #22 │ │ │ │ @ instruction: 0xf9fef7ff │ │ │ │ @ instruction: 0xf0094620 │ │ │ │ @ instruction: 0xf8d6f907 │ │ │ │ stccs 1, cr5, [r0, #-16] │ │ │ │ stcge 4, cr15, [r6], {127} @ 0x7f │ │ │ │ @ instruction: 0xf7fe4620 │ │ │ │ strmi pc, [r5], -fp, asr #27 │ │ │ │ cdp 4, 11, cr14, cr6, cr0, {4} │ │ │ │ str r0, [sp], #-2816 @ 0xfffff500 │ │ │ │ - blne ff05fff8 <__bss_end__@@Base+0xfefb93c0> │ │ │ │ + blne ff05ff80 <__bss_end__@@Base+0xfefb93e0> │ │ │ │ orrsne pc, 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0xf8d9213c │ │ │ │ - blcs 30f94 │ │ │ │ + blcs 30f1c │ │ │ │ ldc 0, cr13, [r9, #496] @ 0x1f0 │ │ │ │ vcmp.f64 d7, #0.0 │ │ │ │ vneg.f64 d23, d0 │ │ │ │ tstple r1, r0, lsl sl @ p-variant is OBSOLETE │ │ │ │ - blge 10e018c <__bss_end__@@Base+0x1039554> │ │ │ │ + blge 10e0114 <__bss_end__@@Base+0x1039574> │ │ │ │ msrcc CPSR_fs, #212, 16 @ 0xd40000 │ │ │ │ ldrsbcc pc, [r8, #131]! @ 0x83 @ │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ @ instruction: 0xf64181b3 │ │ │ │ @ instruction: 0xf8c41399 │ │ │ │ strtmi r3, [r0], -r0, lsl #5 │ │ │ │ - blx 1360ba4 <__bss_end__@@Base+0x12b9f6c> │ │ │ │ + blx 1360b2c <__bss_end__@@Base+0x12b9f8c> │ │ │ │ msrcc CPSR_fs, #212, 16 @ 0xd40000 │ │ │ │ - blls fe7601d8 <__bss_end__@@Base+0xfe6b95a0> │ │ │ │ - blhi fe5e01dc <__bss_end__@@Base+0xfe5395a4> │ │ │ │ + blls fe760160 <__bss_end__@@Base+0xfe6b95c0> │ │ │ │ + blhi fe5e0164 <__bss_end__@@Base+0xfe5395c4> │ │ │ │ ldrdcc pc, [r4, -r6] │ │ │ │ mrcvs 1, 4, fp, cr10, cr3, {1} │ │ │ │ andcs fp, r0, #-2147483640 @ 0x80000008 │ │ │ │ @ instruction: 0xf8c3669a │ │ │ │ subsvs r2, sl, ip, lsr #2 │ │ │ │ - blls ff260678 <__bss_end__@@Base+0xff1b9a40> │ │ │ │ - blx 460770 <__bss_end__@@Base+0x3b9b38> │ │ │ │ + blls ff260600 <__bss_end__@@Base+0xff1b9a60> │ │ │ │ + blx 4606f8 <__bss_end__@@Base+0x3b9b58> │ │ │ │ mvnshi pc, r0, asr #6 │ │ │ │ - ldc 6, cr4, [pc, #128] @ 24c34 │ │ │ │ + ldc 6, cr4, [pc, #128] @ 24bbc │ │ │ │ @ instruction: 0xf7fe0b64 │ │ │ │ strtmi pc, [r0], -sp, asr #21 │ │ │ │ stc2 0, cr15, [r0, #-32]! @ 0xffffffe0 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0xed9fa926 │ │ │ │ @ instruction: 0x46200b3f │ │ │ │ - blx ff0e2bc8 <__bss_end__@@Base+0xff03bf90> │ │ │ │ + blx ff0e2b50 <__bss_end__@@Base+0xff03bfb0> │ │ │ │ msrcc CPSR_fs, #212, 16 @ 0xd40000 │ │ │ │ ldrsbcc pc, [r8, #131]! @ 0x83 @ │ │ │ │ ldc 1, cr11, [r9, #332] @ 0x14c │ │ │ │ vrintr.f64 d7, d2 │ │ │ │ vmul.f64 d6, d7, d0 │ │ │ │ vmov.f64 d6, #70 @ 0x3e300000 0.1718750 │ │ │ │ vsqrt.f64 d22, d10 │ │ │ │ vstrle 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cr12, {6} │ │ │ │ vmov.f64 d6, #64 @ 0x3e000000 0.125 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ vpmin.u8 d15, d0, d0 │ │ │ │ cdp 0, 11, cr8, cr15, cr3, {7} │ │ │ │ vmov.f64 d6, #64 @ 0x3e000000 0.125 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ @ instruction: 0xf6bffa10 │ │ │ │ vmov.32 sl, d15[1] │ │ │ │ @ instruction: 0xf7ff7b00 │ │ │ │ - vldr d11, [pc, #64] @ 24cc8 │ │ │ │ + vldr d11, [pc, #64] @ 24c50 │ │ │ │ vmov.u16 r5, d6[2] │ │ │ │ andcs r6, r0, #0, 22 │ │ │ │ - blvs 1a04a0 <__bss_end__@@Base+0xf9868> │ │ │ │ - blvc ff1e088c <__bss_end__@@Base+0xff139c54> │ │ │ │ - bcc fe4604f8 <__bss_end__@@Base+0xfe3b98c0> │ │ │ │ + blvs 1a0428 <__bss_end__@@Base+0xf9888> │ │ │ │ + blvc ff1e0814 <__bss_end__@@Base+0xff139c74> │ │ │ │ + bcc fe460480 <__bss_end__@@Base+0xfe3b98e0> │ │ │ │ ldmlt r2, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blvc 11a0764 <__bss_end__@@Base+0x10f9b2c> │ │ │ │ - blt 19a2ca4 <__bss_end__@@Base+0x18fc06c> │ │ │ │ - blmi 11a076c <__bss_end__@@Base+0x10f9b34> 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│ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ @ instruction: 0x401921fb │ │ │ │ @@ -34271,194 +34266,194 @@ │ │ │ │ ldrt fp, [r4], #-1301 @ 0xfffffaeb │ │ │ │ svclt 0x00d21bed │ │ │ │ ... │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ svclt 0x00e921fb │ │ │ │ @ instruction: 0x03b761f5 │ │ │ │ svccc 0x005c9871 │ │ │ │ - blvc 9a026c <__bss_end__@@Base+0x8f9634> │ │ │ │ - blls ff2208c4 <__bss_end__@@Base+0xff179c8c> │ │ │ │ - blx 4609bc <__bss_end__@@Base+0x3b9d84> │ │ │ │ + blvc 9a01f4 <__bss_end__@@Base+0x8f9654> │ │ │ │ + blls ff22084c <__bss_end__@@Base+0xff179cac> │ │ │ │ + blx 460944 <__bss_end__@@Base+0x3b9da4> │ │ │ │ ldclge 5, cr15, [sl, #508] @ 0x1fc │ │ │ │ - blvc 6a027c <__bss_end__@@Base+0x5f9644> │ │ │ │ - blls 12a06e0 <__bss_end__@@Base+0x11f9aa8> │ │ │ │ - ldc 5, cr14, [pc, #-848] @ 24ab8 │ │ │ │ + blvc 6a0204 <__bss_end__@@Base+0x5f9664> │ │ │ │ + blls 12a0668 <__bss_end__@@Base+0x11f9ac8> │ │ │ │ + ldc 5, cr14, [pc, #-848] @ 24a40 │ │ │ │ vmov.32 r7, d4[1] │ │ │ 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0xf8d2f7fe │ │ │ │ @ instruction: 0xf0084620 │ │ │ │ stmdacs r0, {r0, r2, r5, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ svcge 0x002bf43e │ │ │ │ - bleq 1f2043c <__bss_end__@@Base+0x1e79804> │ │ │ │ + bleq 1f203c4 <__bss_end__@@Base+0x1e79824> │ │ │ │ @ instruction: 0xf7fe4620 │ │ │ │ cdp 8, 11, cr15, cr4, cr7, {6} │ │ │ │ vsqrt.f64 d25, d8 │ │ │ │ @ instruction: 0xf77ffa10 │ │ │ │ ldrb sl, [sp, #3602]! @ 0xe12 │ │ │ │ - blhi 11e0a98 <__bss_end__@@Base+0x1139e60> │ │ │ │ - ldc 5, cr14, [pc, #-512] @ 24ddc │ │ │ │ + blhi 11e0a20 <__bss_end__@@Base+0x1139e80> │ │ │ │ + ldc 5, cr14, [pc, #-512] @ 24d64 │ │ │ │ ldr r6, [r5, r8, lsl #23] │ │ │ │ - blvc fe260460 <__bss_end__@@Base+0xfe1b9828> │ │ │ │ - blvc 220880 <__bss_end__@@Base+0x179c48> │ │ │ │ - blvs fe160468 <__bss_end__@@Base+0xfe0b9830> │ │ │ │ - blvc ff1e0ac0 <__bss_end__@@Base+0xff139e88> │ │ │ │ - blx 460bb8 <__bss_end__@@Base+0x3b9f80> │ │ │ │ + blvc fe2603e8 <__bss_end__@@Base+0xfe1b9848> │ │ │ │ + blvc 220808 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0xf7f1ab61 │ │ │ │ @ instruction: 0x4605f855 │ │ │ │ - ldc 6, cr4, [pc, #192] @ 252dc │ │ │ │ + ldc 6, cr4, [pc, #192] @ 25264 │ │ │ │ @ instruction: 0xf7f1cb60 │ │ │ │ - blne 1063360 <__bss_end__@@Base+0xfbc728> │ │ │ │ - beq fe460a44 <__bss_end__@@Base+0xfe3b9e0c> │ │ │ │ + blne 10632e8 <__bss_end__@@Base+0xfbc748> │ │ │ │ + beq fe4609cc <__bss_end__@@Base+0xfe3b9e2c> │ │ │ │ cdp 13, 11, cr4, cr7, cr13, {3} │ │ │ │ vmov.f64 d11, #128 @ 0xc0000000 -2.0 │ │ │ │ ldrbtmi r9, [sp], #-3047 @ 0xfffff419 │ │ │ │ strbvc pc, [r6], -r5, lsl #10 @ │ │ │ │ - bleq 260c60 <__bss_end__@@Base+0x1ba028> │ │ │ │ - svc 0x0054f7dd │ │ │ │ - blvc 12a0d04 <__bss_end__@@Base+0x11fa0cc> │ │ │ │ - blvc 1260a48 <__bss_end__@@Base+0x11b9e10> │ │ │ │ + bleq 260be8 <__bss_end__@@Base+0x1ba048> │ │ │ │ + svc 0x006af7dd │ │ │ │ + blvc 12a0c8c <__bss_end__@@Base+0x11fa0ec> │ │ │ │ + blvc 12609d0 <__bss_end__@@Base+0x11b9e30> │ │ │ │ bicvs pc, r6, #20971520 @ 0x1400000 │ │ │ │ strtmi r4, [r0], -r9, ror #12 │ │ │ │ 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blvc 12e0aa4 <__bss_end__@@Base+0x1239e6c> │ │ │ │ - blvs 1120924 <__bss_end__@@Base+0x1079cec> │ │ │ │ + blvc 13a0abc <__bss_end__@@Base+0x12f9f1c> │ │ │ │ + blvc 607f0 <__bss_start@@Base+0x57e8> │ │ │ │ + blx 17631ae <__bss_end__@@Base+0x16bc60e> │ │ │ │ + bvc 160960 <__bss_end__@@Base+0xb9dc0> │ │ │ │ + blmi 142086c <__bss_end__@@Base+0x1379ccc> │ │ │ │ + blpl 1460870 <__bss_end__@@Base+0x13b9cd0> │ │ │ │ + blhi ffa20cd8 <__bss_end__@@Base+0xff97a138> │ │ │ │ + bvc 120970 <__bss_end__@@Base+0x79dd0> │ │ │ │ + blvs ffa20ce0 <__bss_end__@@Base+0xff97a140> │ │ │ │ + bvc 1a0978 <__bss_end__@@Base+0xf9dd8> │ │ │ │ + blhi 160aa8 <__bss_end__@@Base+0xb9f08> │ │ │ │ + blvc ffa20cec <__bss_end__@@Base+0xff97a14c> │ │ │ │ + blhi 1a0a28 <__bss_end__@@Base+0xf9e88> │ │ │ │ + blhi 220af4 <__bss_end__@@Base+0x179f54> │ │ │ │ + blhi 2a0af8 <__bss_end__@@Base+0x1f9f58> │ │ │ │ + blls 13a0b00 <__bss_end__@@Base+0x12f9f60> │ │ │ │ + bleq 2e0c40 <__bss_end__@@Base+0x23a0a0> │ │ │ │ + svc 0x003cf7dd │ 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d12 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ fstmiax r4!, {d6-d8} @ Deprecated │ │ │ │ adcsmi r7, r4, #2048 @ 0x800 │ │ │ │ - blvc 1e0d28 <__bss_end__@@Base+0x13a0f0> │ │ │ │ - blhi 220be8 <__bss_end__@@Base+0x179fb0> │ │ │ │ - blhi e05a0 <__bss_end__@@Base+0x39968> │ │ │ │ + blvc 1e0cb0 <__bss_end__@@Base+0x13a110> │ │ │ │ + blhi 220b70 <__bss_end__@@Base+0x179fd0> │ │ │ │ + blhi e0528 <__bss_end__@@Base+0x39988> │ │ │ │ ldmdami r5!, {r0, r3, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ ldrbtmi r4, [r8], #-1593 @ 0xfffff9c7 │ │ │ │ - blx 632de <__bss_start@@Base+0x823e> │ │ │ │ + blx 63266 <__bss_start@@Base+0x825e> │ │ │ │ @ instruction: 0xf7f04638 │ │ │ │ @ instruction: 0x4604ffd1 │ │ │ │ @ instruction: 0x46394831 │ │ │ │ @ instruction: 0xf7f14478 │ │ │ │ @ instruction: 0x4638faf7 │ │ │ │ @ instruction: 0xffc8f7f0 │ │ │ │ vmla.f32 s2, s14, s9 │ │ │ │ - blmi b77d78 <__bss_end__@@Base+0xad1140> │ │ │ │ + blmi b77d00 <__bss_end__@@Base+0xad1160> │ │ │ │ mrc 6, 5, r4, cr8, cr8, {1} │ │ │ │ ldrbtmi r7, [fp], #-3047 @ 0xfffff419 │ │ │ │ @ instruction: 0xf503461c │ │ │ │ cdp 1, 11, cr6, cr0, cr10, {6} │ │ │ │ vstr d0, [r1, #-284] @ 0xfffffee4 │ │ │ │ @ instruction: 0xf7ff7b02 │ │ │ │ andcs pc, r1, #3472 @ 0xd90 │ │ │ │ ldrbcs pc, [r8], -r4, asr #17 @ │ │ │ │ - bmi 96df5c <__bss_end__@@Base+0x8c7324> │ │ │ │ + bmi 96dee4 <__bss_end__@@Base+0x8c7344> │ │ │ │ ldrbcc pc, [ip], -r4, asr #17 @ │ │ │ │ ldrbtmi r4, [sl], #-2845 @ 0xfffff4e3 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, sp, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andlt sp, pc, r3, lsl #2 │ │ │ │ - blhi 36066c <__bss_end__@@Base+0x2b9a34> │ │ │ │ + blhi 3605f4 <__bss_end__@@Base+0x2b9a54> │ │ │ │ @ instruction: 0xf7debdf0 │ │ │ │ - svclt 0x0000e820 │ │ │ │ + svclt 0x0000e838 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r6, r8, r0 │ │ │ │ @ instruction: 0x5c377b97 │ │ │ │ cmnmi lr, r0, lsr #17 │ │ │ │ smmlarvc fp, r0, r1, r8 │ │ │ │ rscsmi r0, r5, r1, asr #18 │ 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0x000258be │ │ │ │ + andeq r5, r2, r0, asr #17 │ │ │ │ + andeq r7, r3, sl, asr #18 │ │ │ │ + andeq r2, r3, r6, lsl sp │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 1e08b4 <__bss_end__@@Base+0x139c7c> │ │ │ │ + blhi 1e083c <__bss_end__@@Base+0x139c9c> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0010f8cc │ │ │ │ adcslt r4, r0, lr, ror #18 │ │ │ │ ldrbtmi r4, [r9], #-2926 @ 0xfffff492 │ │ │ │ ldrbtmi r4, [sl], #-2670 @ 0xfffff592 │ │ │ │ ldmdavs fp, {r0, r1, r3, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f932f │ │ │ │ @ instruction: 0xf8d20300 │ │ │ │ - blcs 32d84 │ │ │ │ + blcs 32d0c │ │ │ │ adchi pc, pc, r0 │ │ │ │ @ instruction: 0x365cf8d2 │ │ │ │ - blhi 1060ef0 <__bss_end__@@Base+0xfba2b8> │ │ │ │ + blhi 1060e78 <__bss_end__@@Base+0xfba2d8> │ │ │ │ teqlt fp, r0, lsl #13 │ │ │ │ - blvc 3e0f04 <__bss_end__@@Base+0x33a2cc> │ │ │ │ - bleq ff220f0c <__bss_end__@@Base+0xff17a2d4> │ │ │ │ - blx 461004 <__bss_end__@@Base+0x3ba3cc> │ │ │ │ + blvc 3e0e8c <__bss_end__@@Base+0x33a2ec> │ │ │ │ + bleq ff220e94 <__bss_end__@@Base+0xff17a2f4> │ │ │ │ + blx 460f8c <__bss_end__@@Base+0x3ba3ec> │ │ │ │ addshi pc, r7, r0, lsl #2 │ │ │ │ stmdbge r4, {r1, r5, r6, r8, r9, sl, fp, lr} │ │ │ │ - ldc 8, cr10, [pc, #24] @ 25464 │ │ │ │ - ldrbtmi r9, [pc], #-2902 @ 25450 │ │ │ │ + ldc 8, cr10, [pc, #24] @ 253ec │ │ │ │ + ldrbtmi r9, [pc], #-2902 @ 253d8 │ │ │ │ @ instruction: 0xf507ac08 │ │ │ │ @ instruction: 0xf50763c6 │ │ │ │ @ instruction: 0xf50765ca │ │ │ │ ldc 6, cr6, [r3, #800] @ 0x320 │ │ │ │ vldr d7, [r5, #-0] │ │ │ │ vadd.f64 d0, d8, d2 │ │ │ │ vadd.f64 d7, d7, d7 │ │ │ │ @ instruction: 0xf7ff0b00 │ │ │ │ ldc 14, cr15, [r5, #292] @ 0x124 │ │ │ │ vldr d7, [sp] │ │ │ │ vstrge d10, [lr, #-16] │ │ │ │ - blge 1220d68 <__bss_end__@@Base+0x117a130> │ │ │ │ - bleq 2a0eac <__bss_end__@@Base+0x1fa274> │ │ │ │ - mrc 7, 1, APSR_nzcv, cr0, cr13, {6} │ │ │ │ - blge 12a0c8c <__bss_end__@@Base+0x11fa054> │ │ │ │ + blge 1220cf0 <__bss_end__@@Base+0x117a150> │ │ │ │ + bleq 2a0e34 <__bss_end__@@Base+0x1fa294> │ │ │ │ + mcr 7, 2, pc, cr6, cr13, {6} @ │ │ │ │ + blge 12a0c14 <__bss_end__@@Base+0x11fa074> │ │ │ │ stmdage r2, {r0, r3, r5, r6, r9, sl, lr} │ │ │ │ - bleq 12e0f54 <__bss_end__@@Base+0x123a31c> │ │ │ │ - ldcl 7, cr15, [r0, #884]! @ 0x374 │ │ │ │ - blpl e0b10 <__bss_end__@@Base+0x39ed8> │ │ │ │ - blvc 1e0b14 <__bss_end__@@Base+0x139edc> │ │ │ │ + bleq 12e0edc <__bss_end__@@Base+0x123a33c> │ │ │ │ + mcr 7, 0, pc, cr6, cr13, {6} @ │ │ │ │ + blpl e0a98 <__bss_end__@@Base+0x39ef8> │ │ │ │ + blvc 1e0a9c <__bss_end__@@Base+0x139efc> │ │ │ │ ldc 6, cr4, [sp, #160] @ 0xa0 │ │ │ │ movwcs r6, #2816 @ 0xb00 │ │ │ │ stmib sp, {r9, sp}^ │ │ │ │ cdp 3, 2, cr2, cr7, cr12, {0} │ │ │ │ vnmul.f64 d6, d7, d6 │ │ │ │ vstr d7, [sp, #276] @ 0x114 │ │ │ │ vstr d6, [sp, #32] │ │ │ │ @ instruction: 0xf7e57b0a │ │ │ │ - vldr d15, [r6, #996] @ 0x3e4 │ │ │ │ + ldc 12, cr15, [r6, #164] @ 0xa4 │ │ │ │ strtmi r7, [r8], -r0, lsl #22 │ │ │ │ - bleq e60b48 <__bss_end__@@Base+0xdb9f10> │ │ │ │ + bleq e60ad0 <__bss_end__@@Base+0xdb9f30> │ │ │ │ cdp 1, 3, cr2, cr8, cr3, {0} │ │ │ │ vdiv.f64 d7, d7, d7 │ │ │ │ @ instruction: 0xf7e50b00 │ │ │ │ - ldc 13, cr15, [pc, #332] @ 25628 │ │ │ │ + ldc 13, cr15, [pc, #672] @ 25704 │ │ │ │ @ instruction: 0x46280b36 │ │ │ │ @ instruction: 0xf7e52102 │ │ │ │ - strtmi pc, [r2], -sp, asr #26 │ │ │ │ + strtmi pc, [r2], -r2, lsr #27 │ │ │ │ strtmi r4, [r0], -r9, lsr #12 │ │ │ │ - @ instruction: 0xff3cf7e5 │ │ │ │ - blvs e094c <__bss_end__@@Base+0x39d14> │ │ │ │ - blvc ca0b74 <__bss_end__@@Base+0xbf9f3c> │ │ │ │ - blhi 1e0ddc <__bss_end__@@Base+0x13a1a4> │ │ │ │ - blhi 220da0 <__bss_end__@@Base+0x17a168> │ │ │ │ - bleq 2a0f24 <__bss_end__@@Base+0x1fa2ec> │ │ │ │ - ldcl 7, cr15, [r0, #884]! @ 0x374 │ │ │ │ - blhi 12a0d0c <__bss_end__@@Base+0x11fa0d4> │ │ │ │ + @ instruction: 0xf88cf7e6 │ │ │ │ + blvs e08d4 <__bss_end__@@Base+0x39d34> │ │ │ │ + blvc ca0afc <__bss_end__@@Base+0xbf9f5c> │ │ │ │ + blhi 1e0d64 <__bss_end__@@Base+0x13a1c4> │ │ │ │ + blhi 220d28 <__bss_end__@@Base+0x17a188> │ │ │ │ + bleq 2a0eac <__bss_end__@@Base+0x1fa30c> │ │ │ │ + mcr 7, 0, pc, cr6, cr13, {6} @ │ │ │ │ + blhi 12a0c94 <__bss_end__@@Base+0x11fa0f4> │ │ │ │ @ instruction: 0xf7e54628 │ │ │ │ - @ instruction: 0x4628fbd1 │ │ │ │ + strtmi pc, [r8], -r1, lsl #24 │ │ │ │ cdp 1, 11, cr2, cr0, cr3, {0} │ │ │ │ @ instruction: 0xf7e50b48 │ │ │ │ - @ instruction: 0x4622fd31 │ │ │ │ + strtmi pc, [r2], -r6, lsl #27 │ │ │ │ strtmi r4, [r0], -r9, lsr #12 │ │ │ │ - @ instruction: 0xff52f7e5 │ │ │ │ + @ instruction: 0xf8dff7e6 │ │ │ │ strbtmi r4, [r6], r4, lsr #13 │ │ │ │ @ instruction: 0xf8c72301 │ │ │ │ @ instruction: 0x4644365c │ │ │ │ @ instruction: 0x000fe8bc │ │ │ │ strbvs pc, [ip, #1287] @ 0x507 @ │ │ │ │ ldm ip, {r0, r1, r2, r3, sl, lr, pc} │ │ │ │ stm r4, {r0, r1} │ │ │ │ ldm lr!, {r0, r1} │ │ │ │ - strgt r0, [pc, #-15] @ 2553d │ │ │ │ + strgt r0, [pc, #-15] @ 254c5 │ │ │ │ muleq r3, ip, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ - blmi 737dd4 <__bss_end__@@Base+0x69119c> │ │ │ │ + blmi 737d5c <__bss_end__@@Base+0x6911bc> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls bff5c8 <__bss_end__@@Base+0xb58990> │ │ │ │ + blls bff550 <__bss_end__@@Base+0xb589b0> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ tstle r8, r0, lsl #6 │ │ │ │ ldc 0, cr11, [sp], #192 @ 0xc0 │ │ │ │ pop {r1, r2, r8, r9, fp, pc} │ │ │ │ @ instruction: 0xf50281f0 │ │ │ │ strmi r6, [r4], -ip, asr #11 │ │ │ │ - strgt ip, [pc], #-3343 @ 2557c │ │ │ │ + strgt ip, [pc], #-3343 @ 25504 │ │ │ │ muleq r3, r5, r8 │ │ │ │ andeq lr, r3, r4, lsl #17 │ │ │ │ - bmi 55f520 <__bss_end__@@Base+0x4b88e8> │ │ │ │ + bmi 55f4a8 <__bss_end__@@Base+0x4b8908> │ │ │ │ orrvc pc, r4, pc, asr #8 │ │ │ │ ldrbtmi r4, [sl], #-2067 @ 0xfffff7ed │ │ │ │ @ instruction: 0xf7ed4478 │ │ │ │ - pld [sp, r9, asr #18] │ │ │ │ - @ instruction: 0xf7ddecd8 │ │ │ │ - svclt 0x0000ef10 │ │ │ │ + pld [sp, sp, lsr sp] │ │ │ │ + @ instruction: 0xf7ddecec │ │ │ │ + svclt 0x0000ef28 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ @ instruction: 0x401921fb │ │ │ │ @ instruction: 0xf9c00000 │ │ │ │ rsbmi lr, r7, #-2147483637 @ 0x8000000b │ │ │ │ ldrbtvc fp, [r3], #2386 @ 0x952 │ │ │ │ svccc 0x00da2d59 │ │ │ │ vaddl.s16 q15, d20, d12 │ │ │ │ svccc 0x00131da7 │ │ │ │ - strdeq r2, [r3], -r2 @ │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - muleq r3, r6, r8 │ │ │ │ - andeq r7, r3, sl, asr r8 │ │ │ │ - andeq r2, r3, r8, lsr #21 │ │ │ │ - andeq r5, r2, lr, lsr #8 │ │ │ │ - ldrdeq r5, [r2], -r4 │ │ │ │ + andeq r2, r3, sl, ror #24 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r7, r3, r6, ror r8 │ │ │ │ + andeq r7, r3, sl, lsr r8 │ │ │ │ + andeq r2, r3, r0, lsr #22 │ │ │ │ + andeq r5, r2, sl, ror #12 │ │ │ │ + andeq r5, r2, r0, lsl r6 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb7c7e8 <__bss_end__@@Base+0xfead5bb0> │ │ │ │ + bl feb7c770 <__bss_end__@@Base+0xfead5bd0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ ldmdbmi r2, {r3, r4, r5, r6, r7, r8, r9, sl, fp} │ │ │ │ ldrbtmi r4, [r9], #-2066 @ 0xfffff7ee │ │ │ │ ldrbtmi r4, [r8], #-3090 @ 0xfffff3ee │ │ │ │ - mcr 7, 1, pc, cr0, cr13, {6} @ │ │ │ │ + mrc 7, 1, APSR_nzcv, cr8, cr13, {6} │ │ │ │ ldrbtmi r4, [ip], #-2833 @ 0xfffff4ef │ │ │ │ andsvs r4, r8, fp, ror r4 │ │ │ │ ldcmi 1, cr11, [r0], {112} @ 0x70 │ │ │ │ mvnscs r2, r0, asr #4 │ │ │ │ stcne 4, cr4, [r0, #-496]! @ 0xfffffe10 │ │ │ │ - ldc 7, cr15, [sl, #-884]! @ 0xfffffc8c │ │ │ │ + ldcl 7, cr15, [r0, #-884] @ 0xfffffc8c │ │ │ │ subeq pc, r4, r4, lsl #2 │ │ │ │ mvnscs r2, r0, asr #4 │ │ │ │ @ instruction: 0x4010e8bd │ │ │ │ - ldclt 7, cr15, [r0, #-884]! @ 0xfffffc8c │ │ │ │ + stcllt 7, cr15, [r6, #-884] @ 0xfffffc8c │ │ │ │ eorcs r4, r8, #9216 @ 0x2400 │ │ │ │ tstcs r1, r9, lsl #16 │ │ │ │ stmiapl r3!, {r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf7dd681b │ │ │ │ - strb lr, [r6, ip, lsl #29]! │ │ │ │ - andeq r5, r2, lr, lsr #12 │ │ │ │ - ldrdeq r5, [r2], -lr │ │ │ │ - andeq r2, r3, r2, lsl #20 │ │ │ │ - andeq r7, r3, r0, lsr #26 │ │ │ │ - andeq r7, r3, r4, lsl sp │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - @ instruction: 0x000253bc │ │ │ │ + strb lr, [r6, r4, lsr #29]! │ │ │ │ + andeq r5, r2, sl, ror #16 │ │ │ │ + andeq r5, r2, sl, lsl r6 │ │ │ │ + andeq r2, r3, sl, ror sl │ │ │ │ + andeq r7, r3, r0, lsl #26 │ │ │ │ + strdeq r7, [r3], -r4 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + strdeq r5, [r2], -r8 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb7c85c <__bss_end__@@Base+0xfead5c24> │ │ │ │ + bl feb7c7e4 <__bss_end__@@Base+0xfead5c44> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r4], {248} @ 0xf8 │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf7ddb118 │ │ │ │ - movwcs lr, #3256 @ 0xcb8 │ │ │ │ + movwcs lr, #3276 @ 0xccc │ │ │ │ ldclt 0, cr6, [r0, #-140] @ 0xffffff74 │ │ │ │ - @ instruction: 0x00037cbc │ │ │ │ + muleq r3, ip, ip │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb7c880 <__bss_end__@@Base+0xfead5c48> │ │ │ │ + bl feb7c808 <__bss_end__@@Base+0xfead5c68> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ ldmdbmi r3, {r3, r4, r5, r6, r7, r8, r9, sl, fp} │ │ │ │ ldrbtmi r4, [r9], #-2067 @ 0xfffff7ed │ │ │ │ ldrbtmi r4, [r8], #-3091 @ 0xfffff3ed │ │ │ │ - ldcl 7, cr15, [r4, #884] @ 0x374 │ │ │ │ + stcl 7, cr15, [ip, #884]! @ 0x374 │ │ │ │ ldrbtmi r4, [ip], #-2834 @ 0xfffff4ee │ │ │ │ @ instruction: 0xf8c3447b │ │ │ │ cmnlt r8, r4, lsl #1 │ │ │ │ subcs r4, r0, #16, 24 @ 0x1000 │ │ │ │ ldrbtmi r2, [ip], #-511 @ 0xfffffe01 │ │ │ │ addeq pc, r8, r4, lsl #2 │ │ │ │ - stcl 7, cr15, [ip], #884 @ 0x374 │ │ │ │ + stc 7, cr15, [r2, #-884] @ 0xfffffc8c │ │ │ │ sbceq pc, r8, r4, lsl #2 │ │ │ │ mvnscs r2, r0, asr #4 │ │ │ │ @ instruction: 0x4010e8bd │ │ │ │ - stcllt 7, cr15, [r2], #884 @ 0x374 │ │ │ │ + ldcllt 7, cr15, [r8], #884 @ 0x374 │ │ │ │ eorcs r4, r7, #9216 @ 0x2400 │ │ │ │ tstcs r1, r9, lsl #16 │ │ │ │ stmiapl r3!, {r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf7dd681b │ │ │ │ - @ instruction: 0xe7e5ee3e │ │ │ │ - andeq r6, r2, r6, asr #30 │ │ │ │ - andeq r5, r2, r6, lsl #7 │ │ │ │ - andeq r2, r3, sl, ror #18 │ │ │ │ - andeq r7, r3, r8, lsl #25 │ │ │ │ - andeq r7, r3, sl, ror ip │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r5, r2, r0, ror #6 │ │ │ │ + ubfx lr, r6, #28, #6 │ │ │ │ + andeq r7, r2, sl, ror #2 │ │ │ │ + andeq r5, r2, r2, asr #11 │ │ │ │ + andeq r2, r3, r2, ror #19 │ │ │ │ + andeq r7, r3, r8, ror #24 │ │ │ │ + andeq r7, r3, sl, asr ip │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + muleq r2, ip, r5 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0058f8cc │ │ │ │ strhtlt r4, [r1], sp │ │ │ │ ldrbtmi r4, [fp], #-2493 @ 0xfffff643 │ │ │ │ ldrbtmi r4, [r9], #-2749 @ 0xfffff543 │ │ │ │ rscslt pc, r4, #14614528 @ 0xdf0000 │ │ │ │ ldrdvc pc, [r4], r3 │ │ │ │ stmpl sl, {r0, r1, r3, r4, r5, r6, r7, sl, lr} │ │ │ │ andsls r6, pc, #1179648 @ 0x120000 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ subsle r2, r3, r0, lsl #30 │ │ │ │ ldrbtmi r4, [fp], #-3000 @ 0xfffff448 │ │ │ │ - blmi fee4a330 <__bss_end__@@Base+0xfeda36f8> │ │ │ │ + blmi fee4a2b8 <__bss_end__@@Base+0xfeda3718> │ │ │ │ movwls r4, #9339 @ 0x247b │ │ │ │ movwls sl, #2820 @ 0xb04 │ │ │ │ ldrtmi r9, [fp], -r0, lsl #16 │ │ │ │ tstcs r4, r1, lsl #4 │ │ │ │ - mcr 7, 7, pc, cr8, cr13, {6} @ │ │ │ │ + mrc 7, 7, APSR_nzcv, cr8, cr13, {6} │ │ │ │ tstle sp, r1, lsl #16 │ │ │ │ mulscc r1, sp, r8 │ │ │ │ @ instruction: 0x1012f8bd │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ - blls c5b30 <__bss_end__@@Base+0x1eef8> │ │ │ │ - bl f8210 <__bss_end__@@Base+0x515d8> │ │ │ │ + blls c5ab8 <__bss_end__@@Base+0x1ef18> │ │ │ │ + bl f8198 <__bss_end__@@Base+0x515f8> │ │ │ │ @ instruction: 0xf85b0341 │ │ │ │ @ instruction: 0xf9b34002 │ │ │ │ - bl f1984 <__bss_end__@@Base+0x4ad4c> │ │ │ │ - bl e9f74 <__bss_end__@@Base+0x4333c> │ │ │ │ - bl 126574 <__bss_end__@@Base+0x7f93c> │ │ │ │ + bl f190c <__bss_end__@@Base+0x4ad6c> │ │ │ │ + bl e9efc <__bss_end__@@Base+0x4335c> │ │ │ │ + bl 1264fc <__bss_end__@@Base+0x7f95c> │ │ │ │ @ instruction: 0xf89d1483 │ │ │ │ - bcs ed7b4 <__bss_end__@@Base+0x46b7c> │ │ │ │ + bcs ed73c <__bss_end__@@Base+0x46b9c> │ │ │ │ msrhi LR_fiq, r0 │ │ │ │ @ instruction: 0xf002e8df │ │ │ │ ldmdacs r6!, {r0, r1, r4, r7, r8, fp, lr} │ │ │ │ @ instruction: 0xf44f4da4 │ │ │ │ svcmi 0x00a4568a │ │ │ │ - ldrbtmi r4, [pc], #-1149 @ 2578c │ │ │ │ + ldrbtmi r4, [pc], #-1149 @ 25714 │ │ │ │ streq pc, [r6], #261 @ 0x105 │ │ │ │ stmiaeq r6, {r0, r2, r8, ip, sp, lr, pc}^ │ │ │ │ ldrdeq pc, [r4], r5 │ │ │ │ - stc 7, cr15, [r0], #-884 @ 0xfffffc8c │ │ │ │ + ldc 7, cr15, [r4], #-884 @ 0xfffffc8c │ │ │ │ @ instruction: 0xf8c52300 │ │ │ │ vhadd.s8 d19, d17, d4 │ │ │ │ @ instruction: 0xf934153c │ │ │ │ cmnlt fp, r2, lsl #30 │ │ │ │ - bl f8210 <__bss_end__@@Base+0x515d8> │ │ │ │ + bl f8198 <__bss_end__@@Base+0x515f8> │ │ │ │ ldrtmi r1, [r9], -r3 │ │ │ │ addeq lr, r0, r3, lsl #22 │ │ │ │ andcs pc, r2, fp, asr r8 @ │ │ │ │ addne lr, r0, r2, lsl #22 │ │ │ │ andcs pc, r3, #6144 @ 0x1800 │ │ │ │ @ instruction: 0x47985953 │ │ │ │ mvnle r4, r0, lsr #11 │ │ │ │ - blmi fe33821c <__bss_end__@@Base+0xfe2915e4> │ │ │ │ + blmi fe3381a4 <__bss_end__@@Base+0xfe291604> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 7ff840 <__bss_end__@@Base+0x758c08> │ │ │ │ + blls 7ff7c8 <__bss_end__@@Base+0x758c28> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ strdlt r8, [r1], -r7 @ │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf5044d8d │ │ │ │ @ instruction: 0xf64f5380 │ │ │ │ @ instruction: 0x462072ff │ │ │ │ - bl 1769ec <__bss_end__@@Base+0xcfdb4> │ │ │ │ + bl 176974 <__bss_end__@@Base+0xcfdd4> │ │ │ │ @ instruction: 0xf8d30141 │ │ │ │ @ instruction: 0xf8a1313c │ │ │ │ stmibmi r8, {r3, r7, sp} │ │ │ │ @ instruction: 0x47984479 │ │ │ │ ldrdvc pc, [r4], r5 │ │ │ │ mcrmi 7, 4, lr, cr6, cr2, {4} │ │ │ │ cmpcs r2, r1, lsl #4 │ │ │ │ ldrbtmi sl, [lr], #-2054 @ 0xfffff7fa │ │ │ │ ldrdcc pc, [r4], r6 │ │ │ │ - mrc 7, 3, APSR_nzcv, cr8, cr13, {6} │ │ │ │ + mcr 7, 4, pc, cr8, cr13, {6} @ │ │ │ │ @ instruction: 0x9018f9bd │ │ │ │ @ instruction: 0x4012f8bd │ │ │ │ svceq 0x0001f1b9 │ │ │ │ @ instruction: 0xf1b9bf18 │ │ │ │ @ instruction: 0xf0000f06 │ │ │ │ @ instruction: 0xf1a98094 │ │ │ │ - blcs 66444 <__bss_start@@Base+0xb3a4> │ │ │ │ + blcs 663cc <__bss_start@@Base+0xb3c4> │ │ │ │ adchi pc, sp, r0, lsl #4 │ │ │ │ strcs r4, [r0, #-2938] @ 0xfffff486 │ │ │ │ @ instruction: 0xf04f3644 │ │ │ │ - bl 1a78cc <__bss_end__@@Base+0x100c94> │ │ │ │ + bl 1a7854 <__bss_end__@@Base+0x100cb4> │ │ │ │ @ instruction: 0xf10d0644 │ │ │ │ @ instruction: 0xf85b071a │ │ │ │ strtmi sl, [fp], -r3 │ │ │ │ ldrmi r4, [r9], sp, asr #12 │ │ │ │ and r4, r7, r4, asr r6 │ │ │ │ strpl pc, [sl], #1284 @ 0x504 │ │ │ │ movwcc pc, #42250 @ 0xa50a @ │ │ │ │ @@ -34961,15 +34956,15 @@ │ │ │ │ ldrbtmi r4, [fp], #-2917 @ 0xfffff49b │ │ │ │ ldrdvc pc, [r4], r3 │ │ │ │ @ instruction: 0xf8dfe748 │ │ │ │ stcge 1, cr8, [r6, #-576] @ 0xfffffdc0 │ │ │ │ cmncs r0, r1, lsl #4 │ │ │ │ @ instruction: 0x462844f8 │ │ │ │ ldrdcc pc, [r4], r8 │ │ │ │ - mcr 7, 1, pc, cr12, cr13, {6} @ │ │ │ │ + mrc 7, 1, APSR_nzcv, cr12, cr13, {6} │ │ │ │ @ instruction: 0x3012f8bd │ │ │ │ movteq lr, #15112 @ 0x3b08 │ │ │ │ @ instruction: 0x3088f9b3 │ │ │ │ svclt 0x00083301 │ │ │ │ ldrdvc pc, [r4], r8 │ │ │ │ svcge 0x0032f43f │ │ │ │ ldrbteq pc, [r0], r4, lsl #2 @ │ │ │ │ @@ -34977,15 +34972,15 @@ │ │ │ │ @ instruction: 0xf5047912 │ │ │ │ svcge 0x000c7e84 │ │ │ │ mcrreq 1, 0, pc, r8, cr13 @ │ │ │ │ stmia r9!, {r0, r1, r2, r3, r9, sl, fp, lr, pc} │ │ │ │ cps #15 │ │ │ │ ldm r6, {r3, r6, r7, r9, fp} │ │ │ │ stm r9, {r0, r1} │ │ │ │ - stcgt 0, cr0, [pc, #-12] @ 258ec │ │ │ │ + stcgt 0, cr0, [pc, #-12] @ 25874 │ │ │ │ andeq lr, pc, lr, lsr #17 │ │ │ │ muleq r3, r5, r8 │ │ │ │ andeq lr, r3, lr, lsl #17 │ │ │ │ stcls 15, cr12, [r3, #-60] @ 0xffffffc4 │ │ │ │ ldc 5, cr12, [sp, #60] @ 0x3c │ │ │ │ ldm r7, {r2, r3, r4, r8, r9, fp, sp, lr} │ │ │ │ stm r6, {r0, r1} │ │ │ │ @@ -34996,102 +34991,102 @@ │ │ │ │ ldmib sp, {r2, r7, ip, sp, lr}^ │ │ │ │ ldm ip, {r3, r4, r8, fp, pc} │ │ │ │ stm sl, {r0, r1} │ │ │ │ stmib r4, {r0, r1}^ │ │ │ │ @ instruction: 0xed848976 │ │ │ │ vstr d6, [r4, #488] @ 0x1e8 │ │ │ │ @ instruction: 0xe6f97b78 │ │ │ │ - bmi ecc548 <__bss_end__@@Base+0xe25910> │ │ │ │ + bmi ecc4d0 <__bss_end__@@Base+0xe25930> │ │ │ │ movteq lr, #7075 @ 0x1ba3 │ │ │ │ andmi pc, r2, fp, asr r8 @ │ │ │ │ strhcc pc, [r8], #147 @ 0x93 @ │ │ │ │ andne lr, r3, #3072 @ 0xc00 │ │ │ │ orreq lr, r2, #3072 @ 0xc00 │ │ │ │ strne lr, [r3], #2820 @ 0xb04 │ │ │ │ @ instruction: 0xf10de707 │ │ │ │ @ instruction: 0x4638071a │ │ │ │ - blx ffbe19c8 <__bss_end__@@Base+0xffb3ad90> │ │ │ │ - blle 92d180 <__bss_end__@@Base+0x886548> │ │ │ │ + blx ffbe1950 <__bss_end__@@Base+0xffb3adb0> │ │ │ │ + blle 92d108 <__bss_end__@@Base+0x886568> │ │ │ │ ldrtmi r4, [sl], -r8, lsr #22 │ │ │ │ strbeq lr, [r4], #-2822 @ 0xfffff4fa │ │ │ │ @ instruction: 0xf85b2120 │ │ │ │ vst4.8 {d16-d19}, [pc], r3 │ │ │ │ - blx 17a7aa <__bss_end__@@Base+0xd3b72> │ │ │ │ + blx 17a732 <__bss_end__@@Base+0xd3b92> │ │ │ │ stmiane r7, {r0, r1, r8, r9, ip, sp, lr, pc}^ │ │ │ │ ldrmi r3, [r8], #-788 @ 0xfffffcec │ │ │ │ stmdbne r3, {r0, r1, r2, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - @ instruction: 0xf9c0f7ee │ │ │ │ + blx 1a638d0 <__bss_end__@@Base+0x19bcd30> │ │ │ │ ldrdvc pc, [r4], r6 │ │ │ │ addpl pc, r8, r4, lsr #17 │ │ │ │ stmdami r7!, {r2, r3, r6, r7, r9, sl, sp, lr, pc} │ │ │ │ @ instruction: 0xf7dd4478 │ │ │ │ - bmi 9e0f34 <__bss_end__@@Base+0x93a2fc> │ │ │ │ + bmi 9e0efc <__bss_end__@@Base+0x93a35c> │ │ │ │ strbmi r4, [fp], -r6, lsr #16 │ │ │ │ smccs 50250 @ 0xc44a │ │ │ │ - @ instruction: 0xf7ec4478 │ │ │ │ - pld [sp, fp, lsr pc] │ │ │ │ - blmi 9204e0 <__bss_end__@@Base+0x8798a8> │ │ │ │ + @ instruction: 0xf7ed4478 │ │ │ │ + pld [sp, pc, lsr #22] │ │ │ │ + blmi 9204b8 <__bss_end__@@Base+0x879918> │ │ │ │ stmdami r3!, {r0, r3, r4, r5, r9, sp} │ │ │ │ ldrbtmi r2, [r8], #-257 @ 0xfffffeff │ │ │ │ andcc pc, r3, fp, asr r8 @ │ │ │ │ @ instruction: 0xf7dd681b │ │ │ │ - @ instruction: 0xf8d6ecc2 │ │ │ │ + @ instruction: 0xf8d6ecda │ │ │ │ ldrt r7, [r1], r4, lsl #1 │ │ │ │ - ldcl 7, cr15, [r4], #884 @ 0x374 │ │ │ │ + stc 7, cr15, [ip, #-884] @ 0xfffffc8c │ │ │ │ smladcs r0, fp, fp, r4 │ │ │ │ ldmdbmi sp, {r2, r3, r4, sl, fp, lr} │ │ │ │ @ instruction: 0xf85b447c │ │ │ │ ldrbtmi r3, [r9], #-3 │ │ │ │ @ instruction: 0xf7dd6818 │ │ │ │ - @ instruction: 0xf8d4ecd8 │ │ │ │ + @ instruction: 0xf8d4ecf0 │ │ │ │ @ instruction: 0xf7dd0084 │ │ │ │ - @ instruction: 0xf8c4eaf6 │ │ │ │ + @ instruction: 0xf8c4eb0a │ │ │ │ ldr r7, [sp], r4, lsl #1 │ │ │ │ - andeq r7, r3, sl, lsl ip │ │ │ │ - strdeq r2, [r3], -r6 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r2, r3, ip, ror #17 │ │ │ │ strdeq r7, [r3], -sl │ │ │ │ - strdeq r7, [r3], -r4 │ │ │ │ - andeq r0, r0, r0, lsr #5 │ │ │ │ - muleq r3, r8, fp │ │ │ │ - andeq r5, r2, r2, asr #6 │ │ │ │ - andeq r2, r3, r0, lsr r8 │ │ │ │ - andeq r7, r3, ip, lsr #22 │ │ │ │ - andeq r5, r2, r8, asr #5 │ │ │ │ - andeq r7, r3, sl, lsl #22 │ │ │ │ - andeq r0, r0, r8, lsl #5 │ │ │ │ - andeq r7, r3, r6, lsl #21 │ │ │ │ - andeq r7, r3, r4, ror sl │ │ │ │ - strheq r5, [r2], -r4 │ │ │ │ - ldrdeq r5, [r2], -r8 │ │ │ │ - ldrdeq r5, [r2], -ip │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - ldrdeq r5, [r2], -r2 │ │ │ │ - andeq r7, r3, r4, asr #18 │ │ │ │ - strdeq r5, [r2], -r2 │ │ │ │ + andeq r2, r3, lr, ror #18 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r2, r3, r4, ror #18 │ │ │ │ + ldrdeq r7, [r3], -sl │ │ │ │ + ldrdeq r7, [r3], -r4 │ │ │ │ + muleq r0, r8, r2 │ │ │ │ + andeq r7, r3, r8, ror fp │ │ │ │ + andeq r5, r2, lr, ror r5 │ │ │ │ + andeq r2, r3, r8, lsr #17 │ │ │ │ + andeq r7, r3, ip, lsl #22 │ │ │ │ + andeq r5, r2, r4, lsl #10 │ │ │ │ + andeq r7, r3, sl, ror #21 │ │ │ │ + andeq r0, r0, r0, lsl #5 │ │ │ │ + andeq r7, r3, r6, ror #20 │ │ │ │ + andeq r7, r3, r4, asr sl │ │ │ │ + strdeq r5, [r2], -r0 │ │ │ │ + andeq r5, r2, r4, lsl r3 │ │ │ │ + andeq r5, r2, r8, lsl r3 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + andeq r5, r2, lr, lsl #6 │ │ │ │ + andeq r7, r3, r4, lsr #18 │ │ │ │ + andeq r5, r2, lr, lsr #6 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0058f8cc │ │ │ │ adclt r4, r1, sp, asr r9 │ │ │ │ ldrbtmi r4, [r9], #-2909 @ 0xfffff4a3 │ │ │ │ - bmi 17b97e4 <__bss_end__@@Base+0x1712bac> │ │ │ │ + bmi 17b976c <__bss_end__@@Base+0x1712bcc> │ │ │ │ stmiapl fp, {r0, r1, r2, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldmdavs fp, {r1, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf04f931f │ │ │ │ ldmdavs fp!, {r8, r9} │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - blmi 1685cf8 <__bss_end__@@Base+0x15df0c0> │ │ │ │ + blmi 1685c80 <__bss_end__@@Base+0x15df0e0> │ │ │ │ tstls r2, r4, lsl #18 │ │ │ │ stmdaeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ ldmpl r3, {r2, r8, r9, sl, ip, sp}^ │ │ │ │ ldrmi r9, [ip], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2901 @ 0xfffff4ab │ │ │ │ - blmi 158a6a4 <__bss_end__@@Base+0x14e3a6c> │ │ │ │ + blmi 158a62c <__bss_end__@@Base+0x14e3a8c> │ │ │ │ movwls r4, #13435 @ 0x347b │ │ │ │ @ instruction: 0xf504e049 │ │ │ │ @ instruction: 0xf04f7b84 │ │ │ │ @ instruction: 0xf8ad0300 │ │ │ │ @ instruction: 0x46ca3010 │ │ │ │ cdpeq 1, 15, cr15, cr0, cr4, {0} │ │ │ │ ldceq 1, cr15, [r0], #-52 @ 0xffffffcc │ │ │ │ @@ -35102,30 +35097,30 @@ │ │ │ │ ldm fp, {r1, r4, r8, sl, fp, sp, pc} │ │ │ │ stm sl, {r0, r1} │ │ │ │ ldm lr!, {r0, r1} │ │ │ │ stmia ip!, {r0, r1, r2, r3} │ │ │ │ ldm lr, {r0, r1, r2, r3} │ │ │ │ stm ip, {r0, r1} │ │ │ │ cdpgt 0, 0, cr0, cr15, cr3, {0} │ │ │ │ - blls 96f28 <__bss_start@@Base+0x3be88> │ │ │ │ + blls 96eb0 <__bss_start@@Base+0x3bea8> │ │ │ │ ldmdavs fp, {r0, r9, sp} │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ ldrsbeq lr, [sl, #-148]! @ 0xffffff6c │ │ │ │ tsteq ip, sp, asr #19 │ │ │ │ ldrsbeq lr, [r8, #-148]! @ 0xffffff6c │ │ │ │ tsteq sl, sp, asr #19 │ │ │ │ ldrsbeq lr, [r6, #-148]! @ 0xffffff6c │ │ │ │ tsteq r8, sp, asr #19 │ │ │ │ stmdals r2, {r2, r8, sp} │ │ │ │ - ldc 7, cr15, [sl], {221} @ 0xdd │ │ │ │ + ldc 7, cr15, [r2], #-884 @ 0xfffffc8c │ │ │ │ andcs r9, r1, #1024 @ 0x400 │ │ │ │ strbmi r2, [r8], -r0, ror #2 │ │ │ │ @ instruction: 0xf7dd681b │ │ │ │ - blls 60b78 <__bss_start@@Base+0x5ad8> │ │ │ │ + blls 60b60 <__bss_start@@Base+0x5b58> │ │ │ │ strpl pc, [sl], #1284 @ 0x504 │ │ │ │ stmdaeq r1, {r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf5033702 │ │ │ │ addsmi r3, ip, #671088640 @ 0x28000000 │ │ │ │ stmdbvs r3!, {r0, r2, r3, r5, ip, lr, pc} │ │ │ │ rscsle r2, r2, r0, lsl #22 │ │ │ │ @ instruction: 0x2000f9b7 │ │ │ │ @@ -35137,189 +35132,189 @@ │ │ │ │ @ instruction: 0xf8d4001a │ │ │ │ cmpcs r0, ip, lsr #6 │ │ │ │ andhi pc, r0, r7, lsr #17 │ │ │ │ @ instruction: 0xf8ad2601 │ │ │ │ @ instruction: 0xf10d5012 │ │ │ │ ldmvs sl, {r3, r4, r8, fp}^ │ │ │ │ andsvs pc, r0, sp, lsr #17 │ │ │ │ - @ instruction: 0xf8ccf7ee │ │ │ │ + @ instruction: 0xf974f7ee │ │ │ │ ldrtmi r9, [r2], -r3, lsl #22 │ │ │ │ tstcs r4, r2, lsl #16 │ │ │ │ @ instruction: 0xf7dd681b │ │ │ │ - blls 120b18 <__bss_end__@@Base+0x79ee0> │ │ │ │ + blls 120b00 <__bss_end__@@Base+0x79f60> │ │ │ │ cmpcs r2, r2, lsr r6 │ │ │ │ ldmdavs fp, {r3, r6, r9, sl, lr} │ │ │ │ - bl ff763b08 <__bss_end__@@Base+0xff6bced0> │ │ │ │ + bl ffd63a90 <__bss_end__@@Base+0xffcbcef0> │ │ │ │ ldcmi 7, cr14, [r8], {135} @ 0x87 │ │ │ │ mvnscs r2, r0, asr #4 │ │ │ │ @ instruction: 0xf104447c │ │ │ │ @ instruction: 0xf7dd0044 │ │ │ │ - stmdals r2, {r1, r4, r5, r6, r9, fp, sp, lr, pc} │ │ │ │ + stmdals r2, {r3, r7, r9, fp, sp, lr, pc} │ │ │ │ andcs r6, r1, #2293760 @ 0x230000 │ │ │ │ strcs r2, [r3], #-260 @ 0xfffffefc │ │ │ │ andsmi pc, r0, sp, lsl #17 │ │ │ │ @ instruction: 0xf8ad2400 │ │ │ │ @ instruction: 0xf7dd4012 │ │ │ │ - bmi 420ae0 <__bss_end__@@Base+0x379ea8> │ │ │ │ + bmi 420ac8 <__bss_end__@@Base+0x379f28> │ │ │ │ ldrbtmi r4, [sl], #-2823 @ 0xfffff4f9 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, pc, lsl fp │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ eorlt sp, r1, r2, lsl #2 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - bl ffc63b50 <__bss_end__@@Base+0xffbbcf18> │ │ │ │ - muleq r3, r6, r5 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - @ instruction: 0x000378b0 │ │ │ │ - andeq r2, r3, ip, lsl #11 │ │ │ │ - andeq r0, r0, r0, lsr #5 │ │ │ │ - andeq r7, r3, r6, lsl #17 │ │ │ │ - andeq r7, r3, r0, lsl #17 │ │ │ │ - andeq r7, r3, r4, lsl #15 │ │ │ │ - andeq r2, r3, lr, lsr r4 │ │ │ │ + stc 7, cr15, [r8], {221} @ 0xdd │ │ │ │ + andeq r2, r3, lr, lsl #12 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + muleq r3, r0, r8 │ │ │ │ + andeq r2, r3, r4, lsl #12 │ │ │ │ + muleq r0, r8, r2 │ │ │ │ + andeq r7, r3, r6, ror #16 │ │ │ │ + andeq r7, r3, r0, ror #16 │ │ │ │ + andeq r7, r3, r4, ror #14 │ │ │ │ + @ instruction: 0x000324b6 │ │ │ │ vst3.8 {d27,d29,d31}, [pc], r0 │ │ │ │ - bl feb7ce08 <__bss_end__@@Base+0xfead61d0> │ │ │ │ + bl feb7cd90 <__bss_end__@@Base+0xfead61f0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi 529a30 <__bss_end__@@Base+0x482df8> │ │ │ │ + blmi 5299b8 <__bss_end__@@Base+0x482e18> │ │ │ │ ldmdbmi r4, {r0, r2, r3, r4, r7, ip, sp, pc} │ │ │ │ - bmi 536e04 <__bss_end__@@Base+0x4901cc> │ │ │ │ + bmi 536d8c <__bss_end__@@Base+0x4901ec> │ │ │ │ ldmdavs fp, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ ldmdavs r2, {r1, r3, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f921b │ │ │ │ cmplt fp, r0, lsl #4 │ │ │ │ andcs r4, r1, #132, 12 @ 0x8400000 │ │ │ │ strbtmi r2, [r8], -r4, lsl #2 │ │ │ │ cdpeq 0, 0, cr15, cr2, cr15, {2} │ │ │ │ andgt pc, r2, sp, lsr #17 │ │ │ │ and pc, r0, sp, lsl #17 │ │ │ │ - bl fe1e3bb4 <__bss_end__@@Base+0xfe13cf7c> │ │ │ │ - blmi 27846c <__bss_end__@@Base+0x1d1834> │ │ │ │ + bl fe7e3b3c <__bss_end__@@Base+0xfe73cf9c> │ │ │ │ + blmi 2783f4 <__bss_end__@@Base+0x1d1854> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 6ffcb4 <__bss_end__@@Base+0x65907c> │ │ │ │ + blls 6ffc3c <__bss_end__@@Base+0x65909c> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, LR_svc │ │ │ │ @ instruction: 0xf85db01d │ │ │ │ pld [sp, r4, lsl #22] │ │ │ │ - svclt 0x0000ebb0 │ │ │ │ - andeq r7, r3, ip, lsl #14 │ │ │ │ - andeq r2, r3, r8, ror #7 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - @ instruction: 0x000323bc │ │ │ │ + svclt 0x0000ebc8 │ │ │ │ + andeq r7, r3, ip, ror #13 │ │ │ │ + andeq r2, r3, r0, ror #8 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r2, r3, r4, lsr r4 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb7ce78 <__bss_end__@@Base+0xfead6240> │ │ │ │ + bl feb7ce00 <__bss_end__@@Base+0xfead6260> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0x46040ff8 │ │ │ │ @ instruction: 0xf1b2480d │ │ │ │ ldrbtmi r3, [r8], #-4095 @ 0xfffff001 │ │ │ │ @ instruction: 0xf501d014 │ │ │ │ @ instruction: 0xf8cc5c00 │ │ │ │ - bmi 2ae374 <__bss_end__@@Base+0x20773c> │ │ │ │ + bmi 2ae2fc <__bss_end__@@Base+0x20775c> │ │ │ │ ldmdavs r0, {r1, r7, fp, ip, lr} │ │ │ │ svclt 0x00182800 │ │ │ │ svclt 0x00142b00 │ │ │ │ andcs r2, r0, r1 │ │ │ │ movwcs sp, #8451 @ 0x2103 │ │ │ │ addvs r6, fp, ip, lsl #2 │ │ │ │ movwcs fp, #3344 @ 0xd10 │ │ │ │ @ instruction: 0xdeff69db │ │ │ │ - stmdb r8, {r0, r2, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - andeq r2, r3, sl, ror r3 │ │ │ │ - andeq r0, r0, r0, lsl #6 │ │ │ │ + ldmdb ip, {r0, r2, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + strdeq r2, [r3], -r2 @ │ │ │ │ + strdeq r0, [r0], -r8 │ │ │ │ msrcc CPSR_f, #208, 16 @ 0xd00000 │ │ │ │ svclt 0x00022b40 │ │ │ │ tstppl r0, r1, lsl #10 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf8c19b00 │ │ │ │ @ instruction: 0x477031bc │ │ │ │ - blmi f74e0 <__bss_end__@@Base+0x508a8> │ │ │ │ + blmi f7468 <__bss_end__@@Base+0x508c8> │ │ │ │ ldrbtmi r2, [fp], #-1 │ │ │ │ @ instruction: 0xf8436812 │ │ │ │ ldrbmi r0, [r0, -r2, lsr #32]! │ │ │ │ - andeq r7, r3, lr, asr #14 │ │ │ │ + andeq r7, r3, lr, lsr #14 │ │ │ │ ldrbmi r2, [r0, -r0]! │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 1e11ac <__bss_end__@@Base+0x13a574> │ │ │ │ + blhi 1e1134 <__bss_end__@@Base+0x13a594> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0058f8cc │ │ │ │ - bmi fedb7558 <__bss_end__@@Base+0xfed10920> │ │ │ │ - blmi fedb7580 <__bss_end__@@Base+0xfed10948> │ │ │ │ + bmi fedb74e0 <__bss_end__@@Base+0xfed10940> │ │ │ │ + blmi fedb7508 <__bss_end__@@Base+0xfed10968> │ │ │ │ addslt r4, lr, sl, ror r4 │ │ │ │ @ instruction: 0x460449b5 │ │ │ │ ldmpl r3, {r0, r2, r4, r5, r7, r8, r9, sl, fp, lr}^ │ │ │ │ - ldrbtmi r4, [pc], #-1145 @ 25d18 │ │ │ │ + ldrbtmi r4, [pc], #-1145 @ 25ca0 │ │ │ │ tstls sp, #1769472 @ 0x1b0000 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andcs r6, r4, r3, lsl #16 │ │ │ │ orreq lr, r3, r1, lsl #22 │ │ │ │ ldrdhi pc, [r0], r1 │ │ │ │ ldc2l 0, cr15, [r0, #128] @ 0x80 │ │ │ │ strmi r4, [r3], -lr, lsr #19 │ │ │ │ @ instruction: 0xf10d4642 │ │ │ │ ldrbtmi r0, [r9], #-2148 @ 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<__bss_end__@@Base+0x13a9e0> │ │ │ │ - bleq 2615fc <__bss_end__@@Base+0x1ba9c4> │ │ │ │ - bleq 1061874 <__bss_end__@@Base+0xfbac3c> │ │ │ │ - blx 461968 <__bss_end__@@Base+0x3bad30> │ │ │ │ + blx e1d7c <__bss_end__@@Base+0x3b1dc> │ │ │ │ + blvc 11e1354 <__bss_end__@@Base+0x113a7b4> │ │ │ │ + blpl fe3a1384 <__bss_end__@@Base+0xfe2fa7e4> │ │ │ │ + bleq 161340 <__bss_end__@@Base+0xba7a0> │ │ │ │ + blvc 10615ec <__bss_end__@@Base+0xfbaa4c> │ │ │ │ + blvs fe361390 <__bss_end__@@Base+0xfe2ba7f0> │ │ │ │ + blhi de1368 <__bss_end__@@Base+0xd3a7c8> │ │ │ │ + bleq 1a1738 <__bss_end__@@Base+0xfab98> │ │ │ │ + bleq 1e15a0 <__bss_end__@@Base+0x13aa00> │ │ │ │ + bleq 261584 <__bss_end__@@Base+0x1ba9e4> │ │ │ │ + bleq 10617fc <__bss_end__@@Base+0xfbac5c> │ │ │ │ + blx 4618f0 <__bss_end__@@Base+0x3bad50> │ │ │ │ rscshi pc, ip, r0, lsl #2 │ │ │ │ - blvc ff061870 <__bss_end__@@Base+0xfefbac38> │ │ │ │ - blvc ff061884 <__bss_end__@@Base+0xfefbac4c> │ │ │ │ - blx 461978 <__bss_end__@@Base+0x3bad40> │ │ │ │ + blvc ff0617f8 <__bss_end__@@Base+0xfefbac58> │ │ │ │ + blvc ff06180c <__bss_end__@@Base+0xfefbac6c> │ │ │ │ + blx 461900 <__bss_end__@@Base+0x3bad60> │ │ │ │ vmov.s16 sp, d8[3] │ │ │ │ vadd.f64 d5, d8, d7 │ │ │ │ - vldr d8, [pc, #284] @ 25edc │ │ │ │ + vldr d8, [pc, #284] @ 25e64 │ │ │ │ vdiv.f64 d6, d21, d1 │ │ │ │ vdiv.f64 d7, d8, d6 │ │ │ │ vmov.f64 d2, #70 @ 0x3e300000 0.1718750 │ │ │ │ vneg.f64 d23, d2 │ │ │ │ svclt 0x00c8fa10 │ │ │ │ - blcs 1221898 <__bss_end__@@Base+0x117ac60> │ │ │ │ - blne d6142c <__bss_end__@@Base+0xcba7f4> │ │ │ │ + blcs 1221820 <__bss_end__@@Base+0x117ac80> │ │ │ │ + blne d613b4 <__bss_end__@@Base+0xcba814> │ │ │ │ ldc 6, cr4, [r4, #256] @ 0x100 │ │ │ │ - vldr d0, [pc, #200] @ 25eac │ │ │ │ + vldr d0, [pc, #200] @ 25e34 │ │ │ │ vmov.16 d1[3], r8 │ │ │ │ vmla.f64 d6, d0, d1 │ │ │ │ vmov.f64 d6, #16 @ 0x40800000 4.0 │ │ │ │ @ instruction: 0xee817bc6 │ │ │ │ vmul.f64 d1, d7, d7 │ │ │ │ vdiv.f64 d2, d0, d2 │ │ │ │ vmul.f64 d0, d2, d7 │ │ │ │ @ instruction: 0xf7e82b08 │ │ │ │ - @ instruction: 0x4640fa7b │ │ │ │ + strbmi pc, [r0], -pc, ror #28 @ │ │ │ │ ldmdaeq r8, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7e94641 │ │ │ │ - strbmi pc, [r0], -r9, lsl #21 @ │ │ │ │ + @ instruction: 0x4640fe7d │ │ │ │ ldmdaeq r0!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x71acf504 │ │ │ │ @ instruction: 0xf7e54642 │ │ │ │ - strbmi pc, [r0], -r3, lsr #20 @ │ │ │ │ + @ instruction: 0x4640faf7 │ │ │ │ @ instruction: 0xf104aa12 │ │ │ │ @ instruction: 0xf7e50148 │ │ │ │ - @ instruction: 0xf8d4fa5b │ │ │ │ + @ instruction: 0xf8d4fb6f │ │ │ │ ldc 3, cr3, [sp, #176] @ 0xb0 │ │ │ │ vldr d7, [sp, #72] @ 0x48 │ │ │ │ vldr d4, [sp, #80] @ 0x50 │ │ │ │ vldr d5, [r3, #88] @ 0x58 │ │ │ │ vldr d2, [r3, #536] @ 0x218 │ │ │ │ vldr d3, [r3, #544] @ 0x220 │ │ │ │ vmla.f64 d6, d18, d10 │ │ │ │ @@ -35327,196 +35322,196 @@ │ │ │ │ vmls.f64 d4, d6, d8 │ │ │ │ vcmp.f64 d5, #0.0 │ │ │ │ vstr d7, [sp, #768] @ 0x300 │ │ │ │ vstr d7, [sp, #72] @ 0x48 │ │ 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0xf01f2336 │ │ │ │ @ instruction: 0x4620f899 │ │ │ │ - bleq 11e1660 <__bss_end__@@Base+0x113aa28> │ │ │ │ + bleq 11e15e8 <__bss_end__@@Base+0x113aa48> │ │ │ │ @ instruction: 0xf8fcf004 │ │ │ │ ldrbtmi r4, [r8], #-2166 @ 0xfffff78a │ │ │ │ - blmi 1cf8a34 <__bss_end__@@Base+0x1c51dfc> │ │ │ │ + blmi 1cf89bc <__bss_end__@@Base+0x1c51e1c> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 3800cc <__bss_end__@@Base+0x2d9494> │ │ │ │ + blls 380054 <__bss_end__@@Base+0x2d94b4> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ ldrdlt r8, [lr], -r1 │ │ │ │ - blhi 261368 <__bss_end__@@Base+0x1ba730> │ │ │ │ - ldc 13, cr11, [pc, #448] @ 26238 │ │ │ │ + blhi 2612f0 <__bss_end__@@Base+0x1ba750> │ │ │ │ + ldc 13, cr11, [pc, #448] @ 261c0 │ │ │ │ @ instruction: 0xf504ab67 │ │ │ │ ldc 0, cr7, [r4, #576] @ 0x240 │ │ │ │ vmlsge.f64 d0, d6, d6 │ │ │ │ - blls 19a1704 <__bss_end__@@Base+0x18faacc> │ │ │ │ - bleq 2e1a8c <__bss_end__@@Base+0x23ae54> │ │ │ │ + blls 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3, 2, cr2, cr7, cr2, {0} │ │ │ │ stmib sp, {r0, r1, r8, r9, fp, ip, sp, lr}^ │ │ │ │ stc 3, cr2, [r4, #16] │ │ │ │ @ instruction: 0x46320b38 │ │ │ │ - blvc 61984 <__bss_start@@Base+0x68e4> │ │ │ │ - blvc 61988 <__bss_start@@Base+0x68e8> │ │ │ │ - blvc 16198c <__bss_end__@@Base+0xbad54> │ │ │ │ - blvs 11a1910 <__bss_end__@@Base+0x10facd8> │ │ │ │ - blvs 6172c <__bss_start@@Base+0x668c> │ │ │ │ - @ instruction: 0xf8b6f7e5 │ │ │ │ + blvc 6190c <__bss_start@@Base+0x6904> │ │ │ │ + blvc 61910 <__bss_start@@Base+0x6908> │ │ │ │ + blvc 161914 <__bss_end__@@Base+0xbad74> │ │ │ │ + blvs 11a1898 <__bss_end__@@Base+0x10facf8> │ │ │ │ + blvs 616b4 <__bss_start@@Base+0x66ac> │ │ │ │ + @ instruction: 0xf98af7e5 │ │ │ │ msrcc CPSR_fs, #212, 16 @ 0xd40000 │ │ │ │ ldc 6, cr4, [sp, #196] @ 0xc4 │ │ │ │ strtmi r7, [r0], -sl, lsl #22 │ │ │ │ - blhi 1be1758 <__bss_end__@@Base+0x1b3ab20> │ │ │ │ - blvc 2619ec <__bss_end__@@Base+0x1badb4> │ │ │ │ - bleq 1261bd4 <__bss_end__@@Base+0x11baf9c> │ │ │ │ - blvc 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fp, ip, sp}^ │ │ │ │ - blvc ce1794 <__bss_end__@@Base+0xc3ab5c> │ │ │ │ + blvc ce171c <__bss_end__@@Base+0xc3ab7c> │ │ │ │ strvc pc, [r4, #1284] @ 0x504 │ │ │ │ ldc 6, cr4, [r6, #160] @ 0xa0 │ │ │ │ vldr d5, [r3] │ │ │ │ vmul.f64 d4, d5, d0 │ │ │ │ vmul.f64 d6, d5, d6 │ │ │ │ vmul.f64 d7, d2, d7 │ │ │ │ vmul.f64 d2, d11, d9 │ │ │ │ @@ -35533,144 +35528,144 @@ │ │ │ │ vmov.f64 d7, #16 @ 0x40800000 4.0 │ │ │ │ vldr d2, [r4, #796] @ 0x31c │ │ │ │ vmls.f64 d7, d6, d6 │ │ │ │ vstr d7, [r4, #296] @ 0x128 │ │ │ │ @ instruction: 0xee817b46 │ │ │ │ vdiv.f64 d1, d0, d2 │ │ │ │ @ instruction: 0xf7e80b02 │ │ │ │ - @ instruction: 0xf104f8ab │ │ │ │ + @ instruction: 0xf104fc9f │ │ │ │ @ instruction: 0x462801f0 │ │ │ │ - @ instruction: 0xf8baf7e9 │ │ │ │ + stc2 7, cr15, [lr], #932 @ 0x3a4 │ │ │ │ @ instruction: 0x71acf504 │ │ │ │ - @ instruction: 0xf7e94628 │ │ │ │ - ldc 12, cr15, [sp, #1012] @ 0x3f4 │ │ │ │ + @ instruction: 0xf7ea4628 │ │ │ │ + ldc 8, cr15, [sp, #964] @ 0x3c4 │ │ │ │ vldr d5, [sp, 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r2, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + bvs fe0acb60 <__bss_end__@@Base+0xfe005fc0> │ │ │ │ svccc 0x00d381da │ │ │ │ svchi 0x005c28f6 │ │ │ │ submi r1, r0, r2, asr #11 │ │ │ │ - andeq r1, r3, lr, ror #31 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r1, r3, r4, ror #31 │ │ │ │ - andeq r4, r2, sl, lsr #21 │ │ │ │ - andeq r1, r3, r4, lsr #31 │ │ │ │ - andeq r0, r0, r0, lsl #5 │ │ │ │ - andeq r0, r0, ip, lsl #5 │ │ │ │ + andeq r2, r3, r6, rrx │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r2, r3, ip, asr r0 │ │ │ │ + andeq r4, r2, r6, ror #25 │ │ │ │ + andeq r2, r3, ip, lsl r0 │ │ │ │ + andeq r0, r0, r8, ror r2 │ │ │ │ + andeq r0, r0, r4, lsl #5 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb7d448 <__bss_end__@@Base+0xfead6810> │ │ │ │ + bl feb7d3d0 <__bss_end__@@Base+0xfead6830> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r8], {240} @ 0xf0 │ │ │ │ stmdavs r5, {r8, r9, sp} │ │ │ │ ldrbtmi r2, [ip], #-260 @ 0xfffffefc │ │ │ │ eorcc pc, r5, r4, asr #16 │ │ │ │ streq lr, [r5], #2820 @ 0xb04 │ │ │ │ - blx 10e22e6 <__bss_end__@@Base+0x103b6ae> │ │ │ │ + blx 10e226e <__bss_end__@@Base+0x103b6ce> │ │ │ │ andcs r4, r1, r3, lsl #12 │ │ │ │ addcc pc, r0, r4, asr #17 │ │ │ │ svclt 0x0000bd38 │ │ │ │ - ldrdeq r7, [r3], -r2 │ │ │ │ + @ instruction: 0x000371b2 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 161734 <__bss_end__@@Base+0xbaafc> │ │ │ │ + blhi 1616bc <__bss_end__@@Base+0xbab1c> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0028f8cc │ │ │ │ ldcmi 6, cr4, [r2, #24] │ │ │ │ umlallt r4, r9, r2, fp │ │ │ │ - blmi fe261910 <__bss_end__@@Base+0xfe1bacd8> │ │ │ │ + blmi fe261898 <__bss_end__@@Base+0xfe1bacf8> │ │ │ │ ldc 4, cr4, [r6, #500] @ 0x1f4 │ │ │ │ @ instruction: 0xf10d5b32 │ │ │ │ @ instruction: 0xed960920 │ │ │ │ @ instruction: 0xf5006b34 │ │ │ │ ldc 1, cr7, [r6, #688] @ 0x2b0 │ │ │ │ @ instruction: 0x464a7b36 │ │ │ │ cdp 8, 2, cr5, cr5, cr11, {7} │ │ │ │ vmul.f64 d5, d6, d4 │ │ │ │ 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<__bss_end__@@Base+0x8b9e08> │ │ │ │ stmpl r0, {r1, r2, r8, sl, ip, sp, lr, pc} │ │ │ │ - blpl 3e1928 <__bss_end__@@Base+0x33acf0> │ │ │ │ - bleq 1a6272c <__bss_end__@@Base+0x19bbaf4> │ │ │ │ - blvs 461930 <__bss_end__@@Base+0x3bacf8> │ │ │ │ - blvc 4e1934 <__bss_end__@@Base+0x43acfc> │ │ │ │ - @ instruction: 0xf864f7e5 │ │ │ │ - bmi 1df90e0 <__bss_end__@@Base+0x1d524a8> │ │ │ │ + blpl 3e18b0 <__bss_end__@@Base+0x33ad10> │ │ │ │ + bleq 1a626b4 <__bss_end__@@Base+0x19bbb14> │ │ │ │ + blvs 4618b8 <__bss_end__@@Base+0x3bad18> │ │ │ │ + blvc 4e18bc <__bss_end__@@Base+0x43ad1c> │ │ │ │ + @ instruction: 0xf9f1f7e5 │ │ │ │ + bmi 1df9068 <__bss_end__@@Base+0x1d524c8> │ │ │ │ msrne CPSR_fs, #14024704 @ 0xd60000 │ │ │ │ andls r4, r5, #2046820352 @ 0x7a000000 │ │ │ │ - blls 1ae1990 <__bss_end__@@Base+0x1a3ad58> │ │ │ │ + blls 1ae1918 <__bss_end__@@Base+0x1a3ad78> │ │ │ │ andge pc, r3, r4, asr r8 @ │ │ │ │ - vldr d10, [pc, #128] @ 2639c │ │ │ │ + vldr d10, [pc, #128] @ 26324 │ │ │ │ @ instruction: 0xf50a8b6a │ │ │ │ ldrbmi r5, [r4], -r5, lsl #11 │ │ │ │ @ instruction: 0xf50a3508 │ │ │ │ movwls r3, #18186 @ 0x470a │ │ │ │ - bcs 25e350 <__bss_end__@@Base+0x1b7718> │ │ │ │ + bcs 25e2d8 <__bss_end__@@Base+0x1b7738> │ │ │ │ adchi pc, r4, r0 │ │ │ │ strpl pc, [sl], #1284 @ 0x504 │ │ │ │ strpl pc, [sl, #1285] @ 0x505 │ │ │ │ ldrhle r4, [ip], #-44 @ 0xffffffd4 │ │ │ │ - bcs 407cc │ │ │ │ + bcs 40754 │ │ │ │ ldc 0, cr13, [r6, #984] @ 0x3d8 │ │ │ │ vldr d6, [r4, #240] @ 0xf0 │ │ │ │ vmov.s16 r7, d7[2] │ │ │ │ vmov.f64 d7, d6 │ │ │ │ vcmpe.f64 d6, d7 │ │ │ │ vsqrt.f64 d22, d9 │ │ │ │ vstmiale r9!, {s31-s46} │ │ │ │ - blpl fe19bc <__bss_end__@@Base+0xf3ad84> │ │ │ │ - blvs fe19b8 <__bss_end__@@Base+0xf3ad80> │ │ │ │ - blvs 11a1c44 <__bss_end__@@Base+0x10fb00c> │ │ │ │ - blpl ff1e1e30 <__bss_end__@@Base+0xff13b1f8> │ │ │ │ - blpl ff2a1e44 <__bss_end__@@Base+0xff1fb20c> │ │ │ │ - blx 461f3c <__bss_end__@@Base+0x3bb304> │ │ │ │ + blpl fe1944 <__bss_end__@@Base+0xf3ada4> │ │ │ │ + blvs fe1940 <__bss_end__@@Base+0xf3ada0> │ │ │ │ + blvs 11a1bcc <__bss_end__@@Base+0x10fb02c> │ │ │ │ + blpl ff1e1db8 <__bss_end__@@Base+0xff13b218> │ │ │ │ + blpl ff2a1dcc <__bss_end__@@Base+0xff1fb22c> │ │ │ │ + blx 461ec4 <__bss_end__@@Base+0x3bb324> │ │ │ │ ldc 12, cr13, [r6, #880] @ 0x370 │ │ │ │ vldr d4, [r4, #256] @ 0x100 │ │ │ │ vsub.f64 d5, d5, d0 │ │ │ │ vmov.f64 d5, d4 │ │ │ │ vcmpe.f64 d4, d5 │ │ │ │ vsqrt.f64 d20, d9 │ │ │ │ vstmiale pc, {s31-s46} │ │ │ │ - blvc 221c34 <__bss_end__@@Base+0x17affc> │ │ │ │ - blvc 1e1bb4 <__bss_end__@@Base+0x13af7c> │ │ │ │ - blvc 1a1bb4 <__bss_end__@@Base+0xfaf7c> │ │ │ │ - bleq ff221e68 <__bss_end__@@Base+0xff17b230> │ │ │ │ - bleq ff2a1e78 <__bss_end__@@Base+0xff1fb240> │ │ │ │ - blx 461f70 <__bss_end__@@Base+0x3bb338> │ │ │ │ + blvc 221bbc <__bss_end__@@Base+0x17b01c> │ │ │ │ + blvc 1e1b3c <__bss_end__@@Base+0x13af9c> │ │ │ │ + blvc 1a1b3c <__bss_end__@@Base+0xfaf9c> │ │ │ │ + bleq ff221df0 <__bss_end__@@Base+0xff17b250> │ │ │ │ + bleq ff2a1e00 <__bss_end__@@Base+0xff1fb260> │ │ │ │ + blx 461ef8 <__bss_end__@@Base+0x3bb358> │ │ │ │ cdp 12, 11, cr13, cr5, cr2, {6} │ │ │ │ vsqrt.f64 d16, d0 │ │ │ │ ldrtle pc, [sp], #2576 @ 0xa10 @ │ │ │ │ svclt 0x00182a06 │ │ │ │ svclt 0x000c2a01 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ movwcs sp, #435 @ 0x1b3 │ │ │ │ @@ -35685,79 +35680,79 @@ │ │ │ │ strpl pc, [sl], #1284 @ 0x504 │ │ │ │ @ instruction: 0xf5054798 │ │ │ │ @ instruction: 0xf8d6558a │ │ │ │ adcsmi r1, ip, #44, 6 @ 0xb0000000 │ │ │ │ @ instruction: 0xf8d8d1a2 │ │ │ │ vst4.8 {d19,d21,d23,d25}, [pc :128], ip │ │ │ │ vhsub.s8 d5, d17, d10 │ │ │ │ - blx ba57a <__bss_end__@@Base+0x13942> │ │ │ │ + blx ba502 <__bss_end__@@Base+0x13962> │ │ │ │ @ instruction: 0xf241ac03 │ │ │ │ andcs r0, r0, #168, 6 @ 0xa0000002 │ │ │ │ andne pc, r3, ip, asr r8 @ │ │ │ │ @ instruction: 0xf8cd9b04 │ │ │ │ stmib sp, {r3, ip, pc}^ │ │ │ │ @ instruction: 0xf8d8b300 │ │ │ │ @ instruction: 0xf00330a8 │ │ │ │ - vldr s30, [pc, #564] @ 2665c │ │ │ │ + vldr s30, [pc, #564] @ 265e4 │ │ │ │ ldmdbge r4, {r0, r3, r5, r8, r9, fp} │ │ │ │ - blcs 61f0c <__bss_start@@Base+0x6e6c> │ │ │ │ - blne 3e1efc <__bss_end__@@Base+0x33b2c4> │ │ │ │ + blcs 61e94 <__bss_start@@Base+0x6e8c> │ │ │ │ + blne 3e1e84 <__bss_end__@@Base+0x33b2e4> │ │ │ │ rscseq pc, r0, r6, lsl #2 │ │ │ │ movwcs r2, #512 @ 0x200 │ │ │ │ tstcs r4, #3358720 @ 0x334000 │ │ │ │ tstcs r6, #3358720 @ 0x334000 │ │ │ │ tstcs r8, #3358720 @ 0x334000 │ │ │ │ stc2l 0, cr15, [ip], #-20 @ 0xffffffec │ │ │ │ ldrdeq pc, [r8], r8 @ │ │ │ │ @ instruction: 0xffa2f001 │ │ │ │ @ instruction: 0xf0194630 │ │ │ │ - bmi 925a68 <__bss_end__@@Base+0x87ee30> │ │ │ │ + bmi 9259f0 <__bss_end__@@Base+0x87ee50> │ │ │ │ teqvs r3, r0, lsl #6 │ │ │ │ ldrbtmi r4, [sl], #-2845 @ 0xfffff4e3 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r7, lsr #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ eorlt sp, r9, sp, lsl r1 │ │ │ │ - blhi 16176c <__bss_end__@@Base+0xbab34> │ │ │ │ + blhi 1616f4 <__bss_end__@@Base+0xbab54> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ ldrdcs pc, [ip, -r8]! │ │ │ │ subspl pc, ip, r1, lsl #4 │ │ │ │ orrpl pc, sl, pc, asr #8 │ │ │ │ ldrdgt pc, [r0], -r5 │ │ │ │ andge pc, r2, #1024 @ 0x400 │ │ │ │ @ instruction: 0x01a8f241 │ │ │ │ - bls 13c5dc <__bss_end__@@Base+0x959a4> │ │ │ │ + bls 13c564 <__bss_end__@@Base+0x959c4> │ │ │ │ strbtmi r9, [r2], -r1, lsl #4 │ │ │ │ andls pc, r8, sp, asr #17 │ │ │ │ andlt pc, r0, sp, asr #17 │ │ │ │ - blx 13624b4 <__bss_end__@@Base+0x12bb87c> │ │ │ │ + blx 136243c <__bss_end__@@Base+0x12bb89c> │ │ │ │ msrne CPSR_fs, #14024704 @ 0xd60000 │ │ │ │ @ instruction: 0xf7dce742 │ │ │ │ - svclt 0x0000ef86 │ │ │ │ - bvs fe0ace78 <__bss_end__@@Base+0xfe006240> │ │ │ │ + svclt 0x0000ef9e │ │ │ │ + bvs fe0ace00 <__bss_end__@@Base+0xfe006260> │ │ │ │ svccc 0x00d381da │ │ │ │ andeq r0, r0, r0 │ │ │ │ addmi r2, ip, r0 │ │ │ │ ... │ │ │ │ submi r0, r9, r0 │ │ │ │ - andeq r1, r3, ip, ror #26 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r1, r3, 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#1284 @ 0x504 │ │ │ │ @@ -35781,95 +35776,95 @@ │ │ │ │ stmib r4, {r2, r3, r5, r8, ip}^ │ │ │ │ stmib r9, {r6, r7, r8, r9, sp}^ │ │ │ │ ldm ip!, {r8, r9, sp} │ │ │ │ stmia lr!, {r0, r1, r2, r3} │ │ │ │ ldm ip, {r0, r1, r2, r3} │ │ │ │ stm lr, {r0, r1} │ │ │ │ ldrtmi r0, [r0], -r3 │ │ │ │ - blx ffa64520 <__bss_end__@@Base+0xff9bd8e8> │ │ │ │ - blvc 62070 <__bss_start@@Base+0x6fd0> │ │ │ │ - bleq ff222068 <__bss_end__@@Base+0xff17b430> │ │ │ │ - blx 462160 <__bss_end__@@Base+0x3bb528> │ │ │ │ + blx fece44a8 <__bss_end__@@Base+0xfec3d908> │ │ │ │ + blvc 61ff8 <__bss_start@@Base+0x6ff0> │ │ │ │ + bleq ff221ff0 <__bss_end__@@Base+0xff17b450> │ │ │ │ + blx 4620e8 <__bss_end__@@Base+0x3bb548> │ │ │ │ sbcshi pc, lr, r0, asr #2 │ │ │ │ - bleq 12629b8 <__bss_end__@@Base+0x11bbd80> │ │ │ │ + bleq 1262940 <__bss_end__@@Base+0x11bbda0> │ │ │ │ ldrbmi r2, [r9], -r0, lsl #5 │ │ │ │ subeq pc, r8, r4, lsl #2 │ │ │ │ - mrc 7, 1, APSR_nzcv, cr14, cr12, {6} │ │ │ │ + mrc 7, 2, APSR_nzcv, cr6, cr12, {6} │ │ │ │ cmncs sl, #3489792 @ 0x354000 │ │ │ │ cmncs sl, #196, 18 @ 0x310000 │ │ │ │ cmncs r8, #3489792 @ 0x354000 │ │ │ │ cmncs r8, #196, 18 @ 0x310000 │ │ │ │ cmncs r6, #3489792 @ 0x354000 │ │ │ │ cmncs r6, #196, 18 @ 0x310000 │ │ │ │ @ instruction: 0xf1042318 │ │ │ │ @ instruction: 0xf8d50cc8 │ │ │ │ - ldc 3, cr14, [pc, #176] @ 26684 │ │ │ │ - blx 10942a <__bss_end__@@Base+0x627f2> │ │ │ │ + ldc 3, cr14, [pc, #176] @ 2660c │ │ │ │ + blx 1093b2 <__bss_end__@@Base+0x62812> │ │ │ │ cdpgt 7, 0, cr15, cr15, cr7, {0} │ │ │ │ andeq lr, pc, ip, lsr #17 │ │ │ │ ldrbvc pc, [r4, -r7, lsl #10] @ │ │ │ │ andls sl, r7, #57344 @ 0xe000 │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ andeq lr, r7, lr, lsl #22 │ │ │ │ @ instruction: 0xf7e44659 │ │ │ │ - bls 225ed8 <__bss_end__@@Base+0x17f2a0> │ │ │ │ + bls 2261b0 <__bss_end__@@Base+0x17f610> │ │ │ │ @ instruction: 0xf505ae08 │ │ │ │ ldrmi r7, [r0], -ip, lsr #3 │ │ │ │ - @ instruction: 0xf7e44632 │ │ │ │ - ldc 14, cr15, [sp, #900] @ 0x384 │ │ │ │ + @ instruction: 0xf7e54632 │ │ │ │ + ldc 8, cr15, [sp, #440] @ 0x1b8 │ │ │ │ vldr d2, [sp, #32] │ │ │ │ @ instruction: 0xf5043b0a │ │ │ │ ldc 6, cr7, [sp, #528] @ 0x210 │ │ │ │ ldrtmi r4, [r1], -ip, lsl #22 │ │ │ │ - blpl fe4e1c74 <__bss_end__@@Base+0xfe43b03c> │ │ │ │ + blpl fe4e1bfc <__bss_end__@@Base+0xfe43b05c> │ │ │ │ rscseq pc, r0, r4, lsl #2 │ │ │ │ - blvs fe561c7c <__bss_end__@@Base+0xfe4bb044> │ │ │ │ - blpl 261e34 <__bss_end__@@Base+0x1bb1fc> │ │ │ │ - blvc fe5e1c84 <__bss_end__@@Base+0xfe53b04c> │ │ │ │ - blvs 261e40 <__bss_end__@@Base+0x1bb208> │ │ │ │ - blvc 261e48 <__bss_end__@@Base+0x1bb210> │ │ │ │ + blvs fe561c04 <__bss_end__@@Base+0xfe4bb064> │ │ │ │ + blpl 261dbc <__bss_end__@@Base+0x1bb21c> │ │ │ │ + blvc fe5e1c0c <__bss_end__@@Base+0xfe53b06c> │ │ │ │ + blvs 261dc8 <__bss_end__@@Base+0x1bb228> │ │ │ │ + blvc 261dd0 <__bss_end__@@Base+0x1bb230> │ │ │ │ vstr FPSCR_nzcvqc, [r4, #4] │ │ │ │ vstr d5, [r4, #240] @ 0xf0 │ │ │ │ vstr d6, [r4, #248] @ 0xf8 │ │ │ │ - @ instruction: 0xf7e87b40 │ │ │ │ - ldrtmi pc, [r0], -r5, ror #25 @ │ │ │ │ + @ instruction: 0xf7e97b40 │ │ │ │ + @ instruction: 0x4630f8d9 │ │ │ │ strtvc pc, [ip], r4, lsl #10 │ │ │ │ @ instruction: 0xf7e94631 │ │ │ │ - @ instruction: 0xf8d4faaf │ │ │ │ + @ instruction: 0xf8d4fea3 │ │ │ │ ldc 3, cr11, [r4, #176] @ 0xb0 │ │ │ │ @ instruction: 0xf04f5b32 │ │ │ │ ldc 14, cr0, [r4] │ │ │ │ @ instruction: 0x46316b34 │ │ │ │ - blvc de1cbc <__bss_end__@@Base+0xd3b084> │ │ │ │ - ldclvc 6, cr15, [pc], #316 @ 267ac │ │ │ │ - blmi ff1e1ce0 <__bss_end__@@Base+0xff13b0a8> │ │ │ │ - blpl 261f0c <__bss_end__@@Base+0x1bb2d4> │ │ │ │ + blvc de1c44 <__bss_end__@@Base+0xd3b0a4> │ │ │ │ + ldclvc 6, cr15, [pc], #316 @ 26734 │ │ │ │ + blmi ff1e1c68 <__bss_end__@@Base+0xff13b0c8> │ │ │ │ + blpl 261e94 <__bss_end__@@Base+0x1bb2f4> │ │ │ │ mcr 14, 1, r4, cr6, cr2, {3} │ │ │ │ - blmi 1cc12a0 <__bss_end__@@Base+0x1c1a668> │ │ │ │ - blvc 261f20 <__bss_end__@@Base+0x1bb2e8> │ │ │ │ - blmi 61cac <__bss_start@@Base+0x6c0c> │ │ │ │ + blmi 1cc1228 <__bss_end__@@Base+0x1c1a688> │ │ │ │ + blvc 261ea8 <__bss_end__@@Base+0x1bb308> │ │ │ │ + blmi 61c34 <__bss_start@@Base+0x6c2c> │ │ │ │ @ instruction: 0xf8c4447e │ │ │ │ ldrbtmi lr, [fp], #-12 │ │ │ │ andvc pc, r7, r8, asr r8 @ │ │ │ │ @ instruction: 0xf8a4aa2c │ │ │ │ ldmdage r2!, {r3, r4, r5, r8, r9, lr, pc} │ │ │ │ - blpl ce1cd4 <__bss_end__@@Base+0xc3b09c> │ │ │ │ + blpl ce1c5c <__bss_end__@@Base+0xc3b0bc> │ │ │ │ stmdbhi r0, {r0, r1, r2, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ stmdbhi lr, {r2, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ movtvs lr, #59850 @ 0xe9ca │ │ │ │ @ instruction: 0x673ce9d4 │ │ │ │ ldrvs lr, [r8, -sp, asr #19]! │ │ │ │ @ instruction: 0x673ee9d4 │ │ │ │ ldrvs lr, [sl, -sp, asr #19]! │ │ │ │ @ instruction: 0x6740e9d4 │ │ │ │ ldrvs lr, [ip, -sp, asr #19]! │ │ │ │ - blvs d61cfc <__bss_end__@@Base+0xcbb0c4> │ │ │ │ - blvc de1d00 <__bss_end__@@Base+0xd3b0c8> │ │ │ │ - cdp2 7, 7, cr15, cr14, cr4, {7} │ │ │ │ + blvs d61c84 <__bss_end__@@Base+0xcbb0e4> │ │ │ │ + blvc de1c88 <__bss_end__@@Base+0xd3b0e8> │ │ │ │ + @ instruction: 0xf80bf7e5 │ │ │ │ @ instruction: 0x232ce9dd │ │ │ │ teqcs lr, #3358720 @ 0x334000 │ │ │ │ @ instruction: 0x232ee9dd │ │ │ │ movtcs lr, #2509 @ 0x9cd │ │ │ │ teqcs r0, #3620864 @ 0x374000 │ │ │ │ movtcs lr, #10701 @ 0x29cd │ │ │ │ @ instruction: 0x6776e9d4 │ │ │ │ @@ -35881,58 +35876,58 @@ │ │ │ │ @ instruction: 0xf8d45385 │ │ │ │ movwcc r2, #33580 @ 0x832c │ │ │ │ strbvs lr, [sl, -sp, asr #19] │ │ │ │ @ instruction: 0x6778e9d4 │ │ │ │ strbvs lr, [ip, -sp, asr #19] │ │ │ │ ldmib r4, {r3, r5, r6, r8, r9, fp, sp, lr}^ │ │ │ │ mcrrge 7, 7, r6, sl, cr10 │ │ │ │ - blge 114b334 <__bss_end__@@Base+0x10a46fc> │ │ │ │ + blge 114b2bc <__bss_end__@@Base+0x10a471c> │ │ │ │ movwls r9, #17411 @ 0x4403 │ │ │ │ - blge fcb330 <__bss_end__@@Base+0xf246f8> │ │ │ │ - blge e4b330 <__bss_end__@@Base+0xda46f8> │ │ │ │ + blge fcb2b8 <__bss_end__@@Base+0xf24718> │ │ │ │ + blge e4b2b8 <__bss_end__@@Base+0xda4718> │ │ │ │ vcgt.s8 d9, d2, d0 │ │ │ │ vcgt.s8 , q1, q10 │ │ │ │ stmib sp, {r2, r3, r4, r6, r9, ip, lr}^ │ │ │ │ @ instruction: 0xf001674e │ │ │ │ - bmi 1125c2c <__bss_end__@@Base+0x107eff4> │ │ │ │ + bmi 1125bb4 <__bss_end__@@Base+0x107f014> │ │ │ │ ldrbtmi r4, [sl], #-2875 @ 0xfffff4c5 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r1, asr fp │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ subslt sp, r3, r5, ror #2 │ │ │ │ - blhi e1a4c <__bss_end__@@Base+0x3ae14> │ │ │ │ + blhi e19d4 <__bss_end__@@Base+0x3ae34> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ tstcs r4, #3489792 @ 0x354000 │ │ │ │ stmib sp, {r1, r2, r4, r5, r7, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf10d2314 │ │ │ │ ldmib r5, {r3, r5, r6, sl, fp}^ │ │ │ │ stmib sp, {r2, r3, r4, r8, r9, sp}^ │ │ │ │ ldmib r5, {r1, r2, r4, r8, r9, sp}^ │ │ │ │ stmib sp, {r2, r5, r8, r9, sp}^ │ │ │ │ ldm lr!, {r3, r4, r8, r9, sp} │ │ │ │ stmia ip!, {r0, r1, r2, r3} │ │ │ │ @ instruction: 0xf10d000f │ │ │ │ vldr d0, [sp, #608] @ 0x260 │ │ │ │ @ instruction: 0x465a6b1a │ │ │ │ - blvc 761e04 <__bss_end__@@Base+0x6bb1cc> │ │ │ │ + blvc 761d8c <__bss_end__@@Base+0x6bb1ec> │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ - blpl 621b4 <__bss_start@@Base+0x7114> │ │ │ │ + blpl 6213c <__bss_start@@Base+0x7134> │ │ │ │ ldc 8, cr10, [sp, #104] @ 0x68 │ │ │ │ ldmdbge r4, {r1, r2, r3, r4, r8, r9, fp, lr} │ │ │ │ - blvs 621c4 <__bss_start@@Base+0x7124> │ │ │ │ + blvs 6214c <__bss_start@@Base+0x7144> │ │ │ │ cdp 0, 8, cr9, cr4, cr7, {0} │ │ │ │ vstr d7, [sp] │ │ │ │ vstr d5, [sp, #104] @ 0x68 │ │ │ │ vstr d6, [sp, #112] @ 0x70 │ │ │ │ @ instruction: 0xf7e47b1e │ │ │ │ - stmdals r7, {r0, r2, r3, r4, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmdals r7, {r1, r6, r9, fp, ip, sp, lr, pc} │ │ │ │ strmi sl, [r1], -r0, lsr #20 │ │ │ │ @ instruction: 0xf7e44658 │ │ │ │ - @ instruction: 0x4620fa17 │ │ │ │ + @ instruction: 0x4620fa3c │ │ │ │ tstcs sl, #3620864 @ 0x374000 │ │ │ │ tstcs r2, #196, 18 @ 0x310000 │ │ │ │ tstcs ip, #3620864 @ 0x374000 │ │ │ │ tstcs sl, #196, 18 @ 0x310000 │ │ │ │ tstcs lr, #3620864 @ 0x374000 │ │ │ │ @ instruction: 0x2322e9c4 │ │ │ │ @ instruction: 0x2320e9dd │ │ │ │ @@ -35943,31 +35938,31 @@ │ │ │ │ @ instruction: 0x2324e9c4 │ │ │ │ @ instruction: 0x2326e9dd │ │ │ │ tstcs r6, #196, 18 @ 0x310000 │ │ │ │ @ instruction: 0x2328e9dd │ │ │ │ tstcs lr, #196, 18 @ 0x310000 │ │ │ │ @ instruction: 0x232ae9dd │ │ │ │ @ instruction: 0x2326e9c4 │ │ │ │ - bleq 1262c2c <__bss_end__@@Base+0x11bbff4> │ │ │ │ + bleq 1262bb4 <__bss_end__@@Base+0x11bc014> │ │ │ │ stc2 0, cr15, [sl], {24} │ │ │ │ @ instruction: 0xf7dce6d4 │ │ │ │ - svclt 0x0000edce │ │ │ │ - bvs fe0ad1e8 <__bss_end__@@Base+0xfe0065b0> │ │ │ │ + svclt 0x0000ede6 │ │ │ │ + bvs fe0ad170 <__bss_end__@@Base+0xfe0065d0> │ │ │ │ svccc 0x00d381da │ │ │ │ - strdeq r1, [r3], -r8 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r1, r3, lr, ror #21 │ │ │ │ - andeq r0, r0, r8, lsl #5 │ │ │ │ - andeq r4, r2, r6, ror #11 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ + andeq r1, r3, r0, ror fp │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r1, r3, r6, ror #22 │ │ │ │ + andeq r0, r0, r0, lsl #5 │ │ │ │ + andeq r4, r2, r2, lsr #16 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ @ instruction: 0xfffff96d │ │ │ │ @ instruction: 0xfffffbe3 │ │ │ │ - @ instruction: 0x000318be │ │ │ │ + andeq r1, r3, r6, lsr r9 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb7da58 <__bss_end__@@Base+0xfead6e20> │ │ │ │ + bl feb7d9e0 <__bss_end__@@Base+0xfead6e40> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r0, #-960]! @ 0xfffffc40 │ │ │ │ ldrbtmi r6, [sp], #-2050 @ 0xfffff7fe │ │ │ │ ldrbtmi r4, [lr], #-3615 @ 0xfffff1e1 │ │ │ │ eorne pc, r2, r5, asr r8 @ │ │ │ │ andcs fp, r1, r9, lsl #18 │ │ │ │ movwcs fp, #3440 @ 0xd70 │ │ │ │ @@ -35976,46 +35971,46 @@ │ │ │ │ stmdacs r0, {r0, r3, r5, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ stmdavs r3!, {r0, r2, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ orreq lr, r3, #5120 @ 0x1400 │ │ │ │ ldrdcc pc, [r0], r3 │ │ │ │ @ instruction: 0xddee2b00 │ │ │ │ strtmi r2, [r0], -r4, lsl #2 │ │ │ │ @ instruction: 0xf83cf020 │ │ │ │ - blle 5ae0a0 <__bss_end__@@Base+0x507468> │ │ │ │ + blle 5ae028 <__bss_end__@@Base+0x507488> │ │ │ │ ldmpl r3!, {r1, r4, r8, r9, fp, lr}^ │ │ │ │ stmdblt fp!, {r0, r1, r3, r4, fp, sp, lr}^ │ │ │ │ movtne lr, #6916 @ 0x1b04 │ │ │ │ rscscc pc, pc, #79 @ 0x4f │ │ │ │ svccs 0x0088f8c3 │ │ │ │ - bl 180940 <__bss_end__@@Base+0xd9d08> │ │ │ │ + bl 1808c8 <__bss_end__@@Base+0xd9d28> │ │ │ │ @ instruction: 0xf8d30383 │ │ │ │ - bcc 6eabc <__bss_start@@Base+0x13a1c> │ │ │ │ + bcc 6ea44 <__bss_start@@Base+0x13a3c> │ │ │ │ addcs pc, r0, r3, asr #17 │ │ │ │ @ instruction: 0xf7ff4620 │ │ │ │ andcs pc, r1, r3, lsl lr @ │ │ │ │ - blmi 255e8c <__bss_end__@@Base+0x1af254> │ │ │ │ + blmi 255e14 <__bss_end__@@Base+0x1af274> │ │ │ │ stmdami r8, {r0, r3, r4, r9, sp} │ │ │ │ ldrbtmi r2, [r8], #-257 @ 0xfffffeff │ │ │ │ ldmdavs fp, {r0, r1, r4, r5, r6, r7, fp, ip, lr} │ │ │ │ - ldc 7, cr15, [r8, #-880]! @ 0xfffffc90 │ │ │ │ + ldcl 7, cr15, [r0, #-880] @ 0xfffffc90 │ │ │ │ svclt 0x0000e7c7 │ │ │ │ - andeq r6, r3, r6, asr #23 │ │ │ │ - muleq r3, sl, r7 │ │ │ │ - muleq r0, r4, r2 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r4, r2, lr, asr r2 │ │ │ │ + andeq r6, r3, r6, lsr #23 │ │ │ │ + andeq r1, r3, r2, lsl r8 │ │ │ │ + andeq r0, r0, ip, lsl #5 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + muleq r2, sl, r4 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb7dafc <__bss_end__@@Base+0xfead6ec4> │ │ │ │ + bl feb7da84 <__bss_end__@@Base+0xfead6ee4> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ strdcs r0, [r0], -r0 @ │ │ │ │ @ instruction: 0xf00f4d29 │ │ │ │ @ instruction: 0x4604fd9d │ │ │ │ ldrbtmi r2, [sp], #-4 │ │ │ │ @ instruction: 0xffdef01f │ │ │ │ - blx d648cc <__bss_end__@@Base+0xcbdc94> │ │ │ │ + blx ff764854 <__bss_end__@@Base+0xff6bdcb4> │ │ │ │ rscvs r2, r0, r0, lsl #6 │ │ │ │ tstpne r2, r4, asr #12 @ p-variant is OBSOLETE │ │ │ │ strbcc pc, [r4, #-2244]! @ 0xfffff73c @ │ │ │ │ andne pc, r2, #64, 12 @ 0x4000000 │ │ │ │ rsceq pc, r1, #192, 4 │ │ │ │ strbne pc, [r0, #-2244]! @ 0xfffff73c @ │ │ │ │ ldrbcs pc, [ip, #-2244] @ 0xfffff73c @ │ │ │ │ @@ -36035,376 +36030,376 @@ │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ cmncs lr, #196, 18 @ 0x310000 │ │ │ │ movwcs r2, #512 @ 0x200 │ │ │ │ mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ cmncs r6, #196, 18 @ 0x310000 │ │ │ │ @ instruction: 0xf00b616c │ │ │ │ @ instruction: 0x4606ff31 │ │ │ │ - blx fef6490e <__bss_end__@@Base+0xfeebdcd6> │ │ │ │ + blx feb64896 <__bss_end__@@Base+0xfeabdcf6> │ │ │ │ ldrtmi r4, [r0], -r3, lsl #12 │ │ │ │ ldrbcc pc, [r8, #-2244] @ 0xfffff73c @ │ │ │ │ - bl 964904 <__bss_end__@@Base+0x8bdccc> │ │ │ │ + bl e6488c <__bss_end__@@Base+0xdbdcec> │ │ │ │ ldcllt 6, cr4, [r0, #-160]! @ 0xffffff60 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ @ instruction: 0x7ef9db23 │ │ │ │ svccc 0x00b4bc6a │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbsmi lr, pc, r0 │ │ │ │ - andeq r3, r3, r2, ror #28 │ │ │ │ - andeq r5, r2, lr, ror ip │ │ │ │ - strdeq r4, [r2], -r4 @ │ │ │ │ + andeq r3, r3, r2, asr #28 │ │ │ │ + andeq r5, r2, r2, lsr #29 │ │ │ │ + andeq r4, r2, r0, lsr r4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ cmnmi r0, #737280 @ 0xb4000 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0080f8cc │ │ │ │ - bmi 7b8228 <__bss_end__@@Base+0x7115f0> │ │ │ │ + bmi 7b81b0 <__bss_end__@@Base+0x711610> │ │ │ │ addslt r4, sl, lr, lsl fp │ │ │ │ mrrc 4, 7, r4, r9, cr10 │ │ │ │ @ instruction: 0x46048b10 │ │ │ │ ldmpl r3, {r0, r2, r3, r5, r6, r9, sl, lr}^ │ │ │ │ tstls r9, #1769472 @ 0x1b0000 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ @ instruction: 0xf998f01e │ │ │ │ @ instruction: 0x46204918 │ │ │ │ @ instruction: 0xf01e4479 │ │ │ │ ldmdbmi r7, {r0, r1, r4, r7, r8, fp, ip, sp, lr, pc} │ │ │ │ strbmi r4, [fp], -r2, asr #12 │ │ │ │ @ instruction: 0x46284479 │ │ │ │ - ldcl 7, cr15, [lr, #880]! @ 0x370 │ │ │ │ + mcr 7, 0, pc, cr8, cr12, {6} @ │ │ │ │ strtmi r4, [r0], -r9, lsr #12 │ │ │ │ @ instruction: 0xf988f01e │ │ │ │ @ instruction: 0x46204912 │ │ │ │ @ instruction: 0xf01e4479 │ │ │ │ ldrtmi pc, [r1], -r3, lsl #19 @ │ │ │ │ @ instruction: 0xf01e4620 │ │ │ │ stmdbmi pc, {r0, r1, r2, r3, r4, r5, r6, r8, fp, ip, sp, lr, pc} @ │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ @ instruction: 0xf97af01e │ │ │ │ - blmi 239260 <__bss_end__@@Base+0x192628> │ │ │ │ + blmi 2391e8 <__bss_end__@@Base+0x192648> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 680a9c <__bss_end__@@Base+0x5d9e64> │ │ │ │ + blls 680a24 <__bss_end__@@Base+0x5d9e84> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, LR_svc │ │ │ │ pop {r1, r3, r4, ip, sp, pc} │ │ │ │ @ instruction: 0xf7dc8370 │ │ │ │ - svclt 0x0000ecbc │ │ │ │ - andeq r1, r3, ip, lsr #12 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r4, r2, r0, ror r1 │ │ │ │ - andeq r4, r2, r8, ror #2 │ │ │ │ - andeq r5, r2, r4, lsl #26 │ │ │ │ - andeq r4, r2, r6, asr #2 │ │ │ │ - ldrdeq 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@ 0xd000 │ │ │ │ strbtmi r4, [sp], -r3, lsl #12 │ │ │ │ @ instruction: 0xf8452400 │ │ │ │ ldrtmi r3, [r1], -r4, lsl #22 │ │ │ │ strcc r2, [r1], #-0 │ │ │ │ - ldc 7, cr15, [r4], #880 @ 0x370 │ │ │ │ + stcl 7, cr15, [r4], {220} @ 0xdc │ │ │ │ svclt 0x00181e02 │ │ │ │ stccs 2, cr2, [r4], {1} │ │ │ │ svclt 0x00c84603 │ │ │ │ - bcs 2f2b8 │ │ │ │ + bcs 2f240 │ │ │ │ stcls 1, cr13, [r0, #-956] @ 0xfffffc44 │ │ │ │ strtmi r4, [r8], -r6, lsl #19 │ │ │ │ @ instruction: 0xf7dc4479 │ │ │ │ - stmdacs r0, {r3, r5, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r4, r5, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ addshi pc, r4, r0 │ │ │ │ - blcs 1dc4b7c <__bss_end__@@Base+0x1d1df44> │ │ │ │ + blcs 1dc4b04 <__bss_end__@@Base+0x1d1df64> │ │ │ │ stmibmi r2, {r2, r4, ip, lr, pc} │ │ │ │ ldrbtmi r4, [r9], #-1576 @ 0xfffff9d8 │ │ │ │ - ldcl 7, cr15, [ip, #-880] @ 0xfffffc90 │ │ │ │ + stcl 7, cr15, [r6, #-880]! @ 0xfffffc90 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ - bmi 2006d50 <__bss_end__@@Base+0x1f60118> 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strtmi r4, [r2], -lr, ror #18 │ │ │ │ @ instruction: 0xf8d34638 │ │ │ │ ldrbtmi r3, [r9], #-812 @ 0xfffffcd4 │ │ │ │ - bleq ff062190 <__bss_end__@@Base+0xfefbb558> │ │ │ │ + bleq ff062118 <__bss_end__@@Base+0xfefbb578> │ │ │ │ @ instruction: 0xff3af7ff │ │ │ │ stmdbmi sl!, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldrtmi r4, [r8], -r2, lsr #12 │ │ │ │ msrcc CPSR_fs, #13828096 @ 0xd30000 │ │ │ │ ldc 4, cr4, [r3, #484] @ 0x1e4 │ │ │ │ @ instruction: 0xf7ff0bc2 │ │ │ │ ldmvs fp!, {r0, r1, r2, r3, r5, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ strtmi r4, [r2], -r5, ror #18 │ │ │ │ stclmi 6, cr4, [r5], #-224 @ 0xffffff20 │ │ │ │ msrcc CPSR_fs, #13828096 @ 0xd30000 │ │ │ │ ldrbtmi r4, [ip], #-1145 @ 0xfffffb87 │ │ │ │ - bleq ff1621c0 <__bss_end__@@Base+0xff0bb588> │ │ │ │ + bleq ff162148 <__bss_end__@@Base+0xff0bb5a8> │ │ │ │ @ instruction: 0xff22f7ff │ │ │ │ - ldc 8, cr6, [pc, #1004] @ 26f68 │ │ │ │ + ldc 8, cr6, [pc, #1004] @ 26ef0 │ │ │ │ @ instruction: 0x46386b50 │ │ │ │ - bleq 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instruction: 0xf04f4051 │ │ │ │ cmnle r2, r0, lsl #4 │ │ │ │ msrpl CPSR_fs, #13828096 @ 0xd30000 │ │ │ │ ldc 6, cr4, [r3, #136] @ 0x88 │ │ │ │ @ instruction: 0x46386bbe │ │ │ │ - bleq ff062228 <__bss_end__@@Base+0xfefbb5f0> │ │ │ │ + bleq ff0621b0 <__bss_end__@@Base+0xfefbb610> │ │ │ │ @ instruction: 0xed95494c │ │ │ │ ldrbtmi r7, [r9], #-2926 @ 0xfffff492 │ │ │ │ - blvc 1e24c4 <__bss_end__@@Base+0x13b88c> │ │ │ │ - bleq 624c8 <__bss_start@@Base+0x7428> │ │ │ │ + blvc 1e244c <__bss_end__@@Base+0x13b8ac> │ │ │ │ + bleq 62450 <__bss_start@@Base+0x7448> │ │ │ │ pop {r0, r1, r2, ip, sp, pc} │ │ │ │ @ instruction: 0xe6e340f0 │ │ │ │ - blmi db9514 <__bss_end__@@Base+0xd128dc> │ │ │ │ + blmi db949c <__bss_end__@@Base+0xd128fc> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 180c68 <__bss_end__@@Base+0xda030> │ │ │ │ + blls 180bf0 <__bss_end__@@Base+0xda050> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ cmple r4, r0, lsl #6 │ │ │ │ ldrbtmi r4, [r9], #-2371 @ 0xfffff6bd │ │ │ │ andlt r4, r7, r8, lsr r6 │ │ │ │ ldrhtmi lr, [r0], #141 @ 0x8d │ │ │ │ stmlt r2, {r1, r2, r3, r4, ip, sp, lr, pc} │ │ │ │ strtmi r4, [r8], -r0, asr #18 │ │ │ │ @ instruction: 0xf7dc4479 │ │ │ │ - stmiblt r0, {r1, r3, r4, r5, r7, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiblt r0, {r2, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xd1232c03 │ │ │ │ ldmdbmi sp!, {r0, sl, fp, ip, pc} │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - ldc 7, cr15, [r0], #880 @ 0x370 │ │ │ │ + ldc 7, cr15, [sl], #880 @ 0x370 │ │ │ │ stmdacs r0, {r0, r9, sl, lr} │ │ │ │ ldmdbmi sl!, {r2, r4, r5, ip, lr, pc} │ │ │ │ ldrbtmi r4, [r9], #-1568 @ 0xfffff9e0 │ │ │ │ - stc 7, cr15, [r8], #880 @ 0x370 │ │ │ │ - bllt 3844c │ │ │ │ + ldc 7, cr15, [r2], #880 @ 0x370 │ │ │ │ + bllt 383d4 │ │ │ │ andcs r9, sl, #131072 @ 0x20000 │ │ │ │ - bl 9e4bc0 <__bss_end__@@Base+0x93df88> │ │ │ │ + bl fe4b48 <__bss_end__@@Base+0xf3dfa8> │ │ │ │ ldrbhi r6, [r8], #-2683 @ 0xfffff585 │ │ │ │ - bmi d6096c <__bss_end__@@Base+0xcb9d34> │ │ │ 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│ │ │ andcs r9, sl, #131072 @ 0x20000 │ │ │ │ - b ffe64c1c <__bss_end__@@Base+0xffdbdfe4> │ │ │ │ + bl 464ba4 <__bss_end__@@Base+0x3be004> │ │ │ │ ldrhi r6, [r8], #-2683 @ 0xfffff585 │ │ │ │ @ instruction: 0xf7dce717 │ │ │ │ - svclt 0x0000eb84 │ │ │ │ + svclt 0x0000eb9c │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ - andeq r1, r3, r6, lsl #11 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r4, r2, ip, ror #1 │ │ │ │ - strheq r4, [r2], -r0 │ │ │ │ - andeq r4, r2, r6, lsl r1 │ │ │ │ - andeq r1, r3, sl, lsl r5 │ │ │ │ - muleq r2, lr, r0 │ │ │ │ - muleq r2, lr, r0 │ │ │ │ - andeq r4, r2, ip, lsl #1 │ │ │ │ - andeq r4, r2, sl, ror r0 │ │ │ │ - andeq r4, r2, r8, rrx │ │ │ │ - andeq r4, r2, r4, asr r0 │ │ │ │ - andeq r4, r2, r6, rrx │ │ │ │ - andeq r4, r2, r8, lsr r0 │ │ │ │ - andeq r4, r2, r6, lsr r0 │ │ │ │ - andeq r4, r2, ip, lsr #32 │ │ │ │ - andeq r1, r3, r6, asr #8 │ │ │ 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lsr r2 │ │ │ │ + andeq r1, r3, r0, lsl #9 │ │ │ │ + andeq r4, r2, sl, lsr #3 │ │ │ │ + andeq r4, r2, r4, lsl r2 │ │ │ │ + andeq r4, r2, sl, lsr #4 │ │ │ │ + andeq r4, r2, r2, lsr #4 │ │ │ │ + andeq r1, r3, lr, lsl r4 │ │ │ │ + andeq r4, r2, r8, lsl r2 │ │ │ │ + andeq r1, r3, r4, lsl #8 │ │ │ │ + andeq r4, r2, lr, lsr #3 │ │ │ │ + andeq r1, r3, sl, ror #7 │ │ │ │ + andeq r4, r2, r8, asr #3 │ │ │ │ andeq r0, r0, r0 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 262204 <__bss_end__@@Base+0x1bb5cc> │ │ │ │ + blhi 26218c <__bss_end__@@Base+0x1bb5ec> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00c0f8cc │ │ │ │ ldrdls pc, [r0], #-141 @ 0xffffff73 │ │ │ │ movwcs r4, #1680 @ 0x690 │ │ │ │ cdp 2, 11, cr2, cr0, cr0, {0} │ │ │ │ vmov.f64 d8, d0 │ │ │ │ strmi r9, [r6], -r1, asr #22 │ │ │ │ strcs r4, [r0, #-1551] @ 0xfffff9f1 │ │ │ │ movwcs lr, #2505 @ 0x9c9 │ │ │ │ - @ instruction: 0xf7e4e008 │ │ │ │ - msrlt LR_irq, r3 │ │ │ │ + @ instruction: 0xf7e5e008 │ │ │ │ + msrlt LR_irq, r7 │ │ │ │ @ instruction: 0xb1b38a63 │ │ │ │ strbmi r8, [r3, #-2595] @ 0xfffff5dd │ │ │ │ strcc sp, [r1, #-19] @ 0xffffffed │ │ │ │ @ instruction: 0xf0104628 │ │ │ │ @ instruction: 0x4604ffd3 │ │ │ │ andeq pc, r8, #4, 2 │ │ │ │ @ instruction: 0x46214638 │ │ │ │ mvnle r2, r0, lsl #24 │ │ │ │ ldrbtmi r4, [r8], #-2295 @ 0xfffff709 │ │ │ │ - bl 18e4d14 <__bss_end__@@Base+0x183e0dc> │ │ │ │ - blhi 26209c <__bss_end__@@Base+0x1bb464> │ │ │ │ + bl 1ce4c9c <__bss_end__@@Base+0x1c3e0fc> │ │ │ │ + blhi 262024 <__bss_end__@@Base+0x1bb484> │ │ │ │ pop {r0, sp} │ │ │ │ - bvs fe907d90 <__bss_end__@@Base+0xfe861158> │ │ │ │ - blvs 262404 <__bss_end__@@Base+0x1bb7cc> │ │ │ │ + bvs fe907d18 <__bss_end__@@Base+0xfe861178> │ │ │ │ + blvs 26238c <__bss_end__@@Base+0x1bb7ec> │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ cdp 1, 11, cr8, cr6, cr8, {1} │ │ │ │ vmul.f64 d7, d6, d0 │ │ │ │ vmul.f64 d6, d6, d7 │ │ │ │ vmla.f64 d6, d6, d9 │ │ │ │ vmov.f64 d7, #217 @ 0xbec80000 -0.3906250 │ │ │ │ ldmib r4, {r0, r1, r2, r6, r7, r8, r9, fp, pc}^ │ │ │ │ stmib r9, {r1, r2, r8, r9, sp}^ │ │ │ │ @ instruction: 0xf7ed2300 │ │ │ │ - vmov.u16 pc, d16[2] │ │ │ │ + mrc 12, 5, APSR_nzcv, cr0, cr9, {2} │ │ │ │ @ instruction: 0xf7ed9b40 │ │ │ │ - @ instruction: 0xeeb6fbad │ │ │ │ + mrc 12, 5, APSR_nzcv, cr6, cr5, {2} │ │ │ │ vmov.f64 d6, #80 @ 0x3e800000 0.250 │ │ │ │ vmov.f64 d5, #128 @ 0xc0000000 -2.0 │ │ │ │ vsub.f64 d8, d25, d8 │ │ │ │ vmla.f64 d9, d9, d0 │ │ │ │ vmla.f64 d5, d5, d6 │ │ │ │ vmov.f64 d22, #216 @ 0xbec00000 -0.375 │ │ │ │ vnmla.f64 d7, d23, d6 │ │ │ │ @ instruction: 0x2c004a90 │ │ │ │ - ldc 13, cr13, [pc, #824] @ 27140 │ │ │ │ + ldc 13, cr13, [pc, #824] @ 270c8 │ │ │ │ andcs r8, r0, #191488 @ 0x2ec00 │ │ │ │ - blls fef2248c <__bss_end__@@Base+0xfee7b854> │ │ │ │ - ldc 1, cr2, [pc, #36] @ 26e38 │ │ │ │ + blls fef22414 <__bss_end__@@Base+0xfee7b874> │ │ │ │ + ldc 1, cr2, [pc, #36] @ 26dc0 │ │ │ │ @ instruction: 0x4630abbc │ │ │ │ stc2l 0, cr15, [r8, #116] @ 0x74 │ │ │ │ - blx fe3e4dd6 <__bss_end__@@Base+0xfe33e19e> │ │ │ │ - bleq ff2628f4 <__bss_end__@@Base+0xff1bbcbc> │ │ │ │ - blx 4629ec <__bss_end__@@Base+0x3bbdb4> │ │ │ │ + ldc2 7, cr15, [r6], #-948 @ 0xfffffc4c │ │ │ │ + bleq ff26287c <__bss_end__@@Base+0xff1bbcdc> │ │ │ │ + blx 462974 <__bss_end__@@Base+0x3bbdd4> │ │ │ │ @ instruction: 0xf7edd87a │ │ │ │ - @ instruction: 0xeeb5fb87 │ │ │ │ + cdp 12, 11, cr15, cr5, cr15, {1} │ │ │ │ vmov.f64 d7, #64 @ 0x3e000000 0.125 │ │ │ │ vsqrt.f64 d16, d7 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ - ldc 0, cr8, [pc, #544] @ 27060 │ │ │ │ + ldc 0, cr8, [pc, #544] @ 26fe8 │ │ │ │ @ instruction: 0xf8d67bb3 │ │ │ │ cdp 3, 11, cr3, cr4, cr8, {0} │ │ │ │ vsqrt.f64 d16, d7 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ - ldc 0, cr8, [pc, #708] @ 27118 │ │ │ │ + ldc 0, cr8, [pc, #708] @ 270a0 │ │ │ │ vmov.u16 r7, d20[2] │ │ │ │ vsqrt.f64 d16, d7 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ - ldc 0, cr8, [pc, #820] @ 27198 │ │ │ │ + ldc 0, cr8, [pc, #820] @ 27120 │ │ │ │ @ instruction: 0xeeb47bae │ │ │ │ vsqrt.f64 d16, d7 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ mrc 0, 5, r8, cr6, cr9, {6} │ │ │ │ vmov.f64 d7, #64 @ 0x3e000000 0.125 │ │ │ │ vsqrt.f64 d16, d7 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ - ldc 0, cr8, [pc, #944] @ 27234 │ │ │ │ + ldc 0, cr8, [pc, #944] @ 271bc │ │ │ │ @ instruction: 0xeeb47ba8 │ │ │ │ vsqrt.f64 d16, d7 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ - ldc 0, cr8, [pc, #852] @ 271e8 │ │ │ │ + ldc 0, cr8, [pc, #852] @ 27170 │ │ │ │ @ instruction: 0xeeb47ba6 │ │ │ │ vsqrt.f64 d16, d7 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ - ldc 0, cr8, [pc, #924] @ 27240 │ │ │ │ + ldc 0, cr8, [pc, #924] @ 271c8 │ │ │ │ @ instruction: 0xeeb47ba4 │ │ │ │ vsqrt.f64 d16, d7 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ - ldc 0, cr8, [pc, #1004] @ 272a0 │ │ │ │ + ldc 0, cr8, [pc, #1004] @ 27228 │ │ │ │ @ instruction: 0xeeb47ba2 │ │ │ │ vsqrt.f64 d16, d7 │ │ │ │ @ instruction: 0xf100fa10 │ │ │ │ - ldc 0, cr8, [pc, #884] @ 27238 │ │ │ │ + ldc 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│ - blvc 2a2780 <__bss_end__@@Base+0x1fbb48> │ │ │ │ - blvc ff1e259c <__bss_end__@@Base+0xff13b964> │ │ │ │ + blcs 73b34 <__bss_start@@Base+0x18b2c> │ │ │ │ + blvc 2a2708 <__bss_end__@@Base+0x1fbb68> │ │ │ │ + blvc ff1e2524 <__bss_end__@@Base+0xff13b984> │ │ │ │ ldc 12, cr13, [sp], #880 @ 0x370 │ │ │ │ andcs r8, r0, #8, 22 @ 0x2000 │ │ │ │ @ instruction: 0xf8d66930 │ │ │ │ @ instruction: 0xf1a03308 │ │ │ │ @ instruction: 0xf8c60001 │ │ │ │ - blx fec2fbcc <__bss_end__@@Base+0xfeb88f94> │ │ │ │ + blx fec2fb54 <__bss_end__@@Base+0xfeb88fb4> │ │ │ │ ldreq pc, [sl], #-128 @ 0xffffff80 │ │ │ │ @ instruction: 0xf443bf58 │ │ │ │ - b 13f7ba8 <__bss_end__@@Base+0x1350f70> │ │ │ │ + b 13f7b30 <__bss_end__@@Base+0x1350f90> │ │ │ │ svclt 0x00581050 │ │ │ │ movwcc pc, #35014 @ 0x88c6 @ │ │ │ │ mvnshi lr, #12386304 @ 0xbd0000 │ │ │ │ strble r0, [r6], #2009 @ 0x7d9 │ │ │ │ movweq pc, #4163 @ 0x1043 @ │ │ │ │ rscsvc pc, pc, #82837504 @ 0x4f00000 │ │ │ │ movwcc pc, #35014 @ 0x88c6 @ │ │ │ │ teqpcs r8, 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{240} @ 0xf0 │ │ │ │ strmi r4, [r1], -lr, lsl #12 │ │ │ │ ldrbtmi r4, [ip], #-1557 @ 0xfffff9eb │ │ │ │ ldrmi r6, [ip], -r0, lsr #16 │ │ │ │ - blx de517c <__bss_end__@@Base+0xd3e544> │ │ │ │ + blx de5104 <__bss_end__@@Base+0xd3e564> │ │ │ │ ldmib sp, {r0, r1, r5, r9, sl, lr}^ │ │ │ │ ldrtmi lr, [r1], -r4, lsl #24 │ │ │ │ eorvc pc, r4, r0, lsl #10 │ │ │ │ @ instruction: 0xf106462a │ │ │ │ ldc 4, cr0, [r1], #96 @ 0x60 │ │ │ │ vstmia r0!, {d7} │ │ │ │ adcmi r7, r1, #2048 @ 0x800 │ │ │ │ - blvc e24ac <__bss_end__@@Base+0x3b874> │ │ │ │ - blvc 1627e8 <__bss_end__@@Base+0xbbbb0> │ │ │ │ - blvc e24b8 <__bss_end__@@Base+0x3b880> │ │ │ │ - blvc 2e27f0 <__bss_end__@@Base+0x23bbb8> │ │ │ │ - blvc e24ec <__bss_end__@@Base+0x3b8b4> │ │ │ │ - blvc 4627f8 <__bss_end__@@Base+0x3bbbc0> │ │ │ │ - blvc e24ec <__bss_end__@@Base+0x3b8b4> │ │ │ │ - blvc 5e2800 <__bss_end__@@Base+0x53bbc8> │ │ │ │ + blvc e2434 <__bss_end__@@Base+0x3b894> │ │ │ │ + blvc 162770 <__bss_end__@@Base+0xbbbd0> │ │ │ │ + blvc e2440 <__bss_end__@@Base+0x3b8a0> │ │ │ │ + blvc 2e2778 <__bss_end__@@Base+0x23bbd8> │ │ │ │ + blvc e2474 <__bss_end__@@Base+0x3b8d4> │ │ │ │ + blvc 462780 <__bss_end__@@Base+0x3bbbe0> │ │ │ │ + blvc e2474 <__bss_end__@@Base+0x3b8d4> │ │ │ │ + blvc 5e2788 <__bss_end__@@Base+0x53bbe8> │ │ │ │ ldcllt 1, cr13, [r0, #-932]! @ 0xfffffc5c │ │ │ │ - andeq r6, r3, lr, ror #6 │ │ │ │ + andeq r6, r3, lr, asr #6 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb7e410 <__bss_end__@@Base+0xfead77d8> │ │ │ │ + bl feb7e398 <__bss_end__@@Base+0xfead77f8> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ cdpmi 15, 1, cr0, cr6, cr8, {7} │ │ │ │ ldrbtmi r4, [lr], #-1541 @ 0xfffff9fb │ │ │ │ @ instruction: 0xf7ee6830 │ │ │ │ mvnlt pc, r3, ror #23 │ │ │ │ @ instruction: 0x46044f13 │ │ │ │ and r4, r4, pc, ror r4 │ │ │ │ @@ -36606,19 +36601,19 @@ │ │ │ │ ldmdavs r0!, {r1, r3, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ ldc2 7, cr15, [r4], #-952 @ 0xfffffc48 │ │ │ │ ldcllt 6, cr4, [r8, #128]! @ 0x80 │ │ │ │ strcs r4, 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pc} │ │ │ │ smlattlt r3, r0, r0, r6 │ │ │ │ stcmi 2, cr8, [pc], {24} │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ - blx 17652ea <__bss_end__@@Base+0x16be6b2> │ │ │ │ + blx 1765272 <__bss_end__@@Base+0x16be6d2> │ │ │ │ cmnlt r8, r1, lsl #12 │ │ │ │ @ instruction: 0xf7ee6820 │ │ │ │ @ instruction: 0x4603f97b │ │ │ │ ldmdavs sl, {r5, fp, sp, lr} │ │ │ │ stmiavs r2!, {r1, r3, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7ee855a │ │ │ │ strmi pc, [r1], -r9, lsl #23 │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ ldrbtmi r4, [fp], #-2821 @ 0xfffff4fb │ │ │ │ pop {r3, r4, fp, sp, lr} │ │ │ │ @ instruction: 0xf7ee4038 │ │ │ │ svclt 0x0000bbb3 │ │ │ │ - andeq r6, r3, r0, lsr #4 │ │ │ │ andeq r6, r3, r0, lsl #4 │ │ │ │ - ldrdeq r6, [r3], -r6 @ │ │ │ │ + andeq r6, r3, r0, ror #3 │ │ │ │ + @ instruction: 0x000361b6 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb89f98 <__bss_end__@@Base+0xfeae3360> │ │ │ │ + bl feb89f20 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<__bss_start@@Base+0x185a4> │ │ │ │ + blcs 735cc <__bss_start@@Base+0x185c4> │ │ │ │ movwcs fp, #3868 @ 0xf1c │ │ │ │ rsbscc pc, ip, #128, 16 @ 0x800000 │ │ │ │ ldc 0, cr13, [sp], #32 │ │ │ │ @ instruction: 0xf1048b08 │ │ │ │ strtmi r0, [r8], -r0, asr #2 │ │ │ │ ldrhtmi lr, [r0], #-141 @ 0xffffff73 │ │ │ │ - stclt 7, cr15, [r2, #-916]! @ 0xfffffc6c │ │ │ │ + ldmdblt r6, {r1, r2, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ addeq pc, r1, #1073741825 @ 0x40000001 │ │ │ │ @ instruction: 0xf500210c │ │ │ │ @ instruction: 0xf7ec701f │ │ │ │ - ubfx pc, r1, #24, #15 │ │ │ │ - andeq r6, r3, r4, lsr #3 │ │ │ │ + @ instruction: 0xe7eefcf9 │ │ │ │ + andeq r6, r3, r4, lsl #3 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb7e67c <__bss_end__@@Base+0xfead7a44> │ │ │ │ + bl feb7e604 <__bss_end__@@Base+0xfead7a64> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - bmi beb1e4 <__bss_end__@@Base+0xb445ac> │ │ │ │ - blmi c13728 <__bss_end__@@Base+0xb6caf0> │ │ │ │ - stcmi 4, cr4, [pc], #-488 @ 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│ │ │ eorscs r2, r8, #0, 2 │ │ │ │ rscvs r6, fp, fp, lsr #1 │ │ │ │ @ instruction: 0xf7db612b │ │ │ │ - mcrcs 13, 0, lr, cr3, cr8, {2} │ │ │ │ + cdpcs 13, 0, cr14, cr3, cr14, {3} │ │ │ │ cmpphi r0, r0, lsl #4 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf006e8df │ │ │ │ stclcs 2, cr9, [lr], #-8 │ │ │ │ stmiblt fp, {r0, r1, r3, r5, r6, fp, ip, sp, lr}^ │ │ │ │ rsbvc r2, fp, r0, lsl #6 │ │ │ │ - blmi feaba0ac <__bss_end__@@Base+0xfea13474> │ │ │ │ + blmi feaba034 <__bss_end__@@Base+0xfea13494> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 401664 <__bss_end__@@Base+0x35aa2c> │ │ │ │ + blls 4015ec <__bss_end__@@Base+0x35aa4c> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ andslt r8, r0, fp, lsr r1 │ │ │ │ @ instruction: 0x87f0e8bd │ │ │ │ strcc r6, [r1], -r0, asr #22 │ │ │ │ - blx fe7655c4 <__bss_end__@@Base+0xfe6be98c> │ │ │ │ + blx 116554e <__bss_end__@@Base+0x10be9ae> │ │ │ │ @ instruction: 0xf7ec6968 │ │ │ │ - stmdavc fp!, {r0, r3, r4, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ - ble 2b8098 <__bss_end__@@Base+0x211460> │ │ │ │ + stmdavc fp!, {r0, r6, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ + ble 2b8020 <__bss_end__@@Base+0x211480> │ │ │ │ @ instruction: 0xf8906968 │ │ │ │ - blcs 336dc │ │ │ │ + blcs 33664 │ │ │ │ @ instruction: 0xf7ecd1f0 │ │ │ │ - stmdavc fp!, {r0, r1, r2, r3, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ + stmdavc fp!, {r0, r1, r2, r4, r5, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ addsmi r3, lr, #1048576 @ 0x100000 │ │ │ │ movwcs sp, #3060 @ 0xbf4 │ │ │ │ ldrb r6, [r7, fp, ror #2] │ │ │ │ @ instruction: 0xf88d2301 │ │ │ │ movwcs r3, #8197 @ 0x2005 │ │ │ │ andcc pc, r6, sp, lsr #17 │ │ │ │ @ instruction: 0xf88d2305 │ │ │ │ @@ -36865,15 +36860,15 @@ │ │ │ │ msrmi CPSR_, #1325400064 @ 0x4f000000 │ │ │ │ orrvs pc, ip, #196, 4 @ 0x4000000c │ │ │ │ @ instruction: 0xf04f9305 │ │ │ │ movwls r5, #25470 @ 0x637e │ │ │ │ @ instruction: 0x601cf8d8 │ │ │ │ rsbscs pc, r8, #216, 16 @ 0xd80000 │ │ │ │ teqpcc r8, #2981888 @ p-variant is OBSOLETE @ 0x2d8000 │ │ │ │ - blcs 3f7cc │ │ │ │ + blcs 3f754 │ │ │ │ stmdavc fp!, {r1, r3, r4, r5, r6, r9, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ stmdbvs r8!, {r0, r1, r2, r3, r4, r5, r7, pc}^ │ │ │ │ mlacc sp, r0, r8, pc @ │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ ssatmi r8, #7, fp, asr #1 │ │ │ │ movwcs r4, #5764 @ 0x1684 │ │ │ │ @@ -36916,22 +36911,22 @@ │ │ │ │ movwls r6, #21388 @ 0x538c │ │ │ │ cmnppl lr, #79 @ p-variant is OBSOLETE @ 0x4f │ │ │ │ @ instruction: 0xf6409306 │ │ │ │ @ instruction: 0xf6c32392 │ │ │ │ movwls r7, #33670 @ 0x8386 │ │ │ │ ldr r9, [r5, sl, lsl #6] │ │ │ │ @ instruction: 0xf1076918 │ │ │ │ - @ instruction: 0xf7e60122 │ │ │ │ - @ instruction: 0xf897fc6e │ │ │ │ + @ instruction: 0xf7e70122 │ │ │ │ + @ instruction: 0xf897f862 │ │ │ │ stccs 0, cr4, [r0], {41} @ 0x29 │ │ │ │ svcge 0x002ef47f │ │ │ │ @ instruction: 0x46234855 │ │ │ │ vqsub.s8 d18, d0, d8 │ │ │ │ ldrbtmi r5, [r8], #-421 @ 0xfffffe5b │ │ │ │ - @ instruction: 0xf942f7ec │ │ │ │ + @ instruction: 0xf9eaf7ec │ │ │ │ strdvs r6, [r4], -r8 │ │ │ │ addvs r6, r4, r4, asr #32 │ │ │ │ smlabtvs r4, r4, r0, r6 │ │ │ │ ldr r6, [sp, -r4, asr #2] │ │ │ │ vst1.16 {d20-d21}, [pc], lr │ │ │ │ vpmax.s8 d21, d17, d10 │ │ │ │ @ instruction: 0xf85908a8 │ │ │ │ @@ -36940,135 +36935,135 @@ │ │ │ │ movwvc pc, #15114 @ 0x3b0a @ │ │ │ │ ldrdeq pc, [r0], -r9 │ │ │ │ andne pc, r8, r3, asr r8 @ │ │ │ │ cdp2 7, 11, cr15, cr3, cr13, {7} │ │ │ │ eorsle r2, sp, r0, lsl #16 │ │ │ │ teqpcc r8, #2981888 @ p-variant is OBSOLETE @ 0x2d8000 │ │ │ │ @ instruction: 0xf6ff2b00 │ │ │ │ - blx 2d355e <__bss_end__@@Base+0x22c926> │ │ │ │ + blx 2d34e6 <__bss_end__@@Base+0x22c946> │ │ │ │ @ instruction: 0xf8d97703 │ │ │ │ @ instruction: 0xf8570000 │ │ │ │ @ instruction: 0xf7ed1008 │ │ │ │ stmdavc fp!, {r0, r1, r3, r4, r5, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ ldrdvc pc, [sl], -r0 @ │ │ │ │ orrlt r8, r3, r6, asr #27 │ │ │ │ @ instruction: 0xf892696a │ │ │ │ - blcs 33880 │ │ │ │ - blvs 151b8dc <__bss_end__@@Base+0x1474ca4> │ │ │ │ + blcs 33808 │ │ │ │ + blvs 151b864 <__bss_end__@@Base+0x1474cc4> │ │ │ │ andne pc, r1, #64, 4 │ │ │ │ sbcshi r9, sl, lr, lsl #6 │ │ │ │ addshi r6, lr, pc, lsl r0 │ │ │ │ stmdbvs r8!, {r0, r8, r9, sp}^ │ │ │ │ eorscc pc, r1, sp, lsl #17 │ │ │ │ ldmdami r5!, {r0, r1, r2, r4, r6, r8, r9, sl, sp, lr, pc} │ │ │ │ vhsub.s8 d18, d0, d8 │ │ │ │ @ instruction: 0xf04f6134 │ │ │ │ ldrbtmi r0, [r8], #-3073 @ 0xfffff3ff │ │ │ │ eorsgt pc, r1, sp, lsl #17 │ │ │ │ - @ instruction: 0xf8f8f7ec │ │ │ │ + @ instruction: 0xf9a0f7ec │ │ │ │ movwne pc, #4672 @ 0x1240 @ │ │ │ │ andvs r9, r7, lr │ │ │ │ sbchi r8, r3, r6, lsl #1 │ │ │ │ movwcs r4, #2093 @ 0x82d │ │ │ │ vqsub.s8 d18, d0, d24 │ │ │ │ ldrbtmi r6, [r8], #-311 @ 0xfffffec9 │ │ │ │ - @ instruction: 0xf8eaf7ec │ │ │ │ + @ instruction: 0xf992f7ec │ │ │ │ ldr r6, [ip, -r8, ror #2]! │ │ │ │ mvnsvc pc, #82837504 @ 0x4f00000 │ │ │ │ teqpcc r8, #10878976 @ p-variant is OBSOLETE @ 0xa60000 │ │ │ │ stmdami r7!, {r0, r2, r3, r5, r8, r9, sl, sp, lr, pc} │ │ │ │ eorscs r4, r8, #61865984 @ 0x3b00000 │ │ │ │ orrspl pc, r6, r0, asr #4 │ │ │ │ @ instruction: 0xf7ec4478 │ │ │ │ - @ instruction: 0x4639f8db │ │ │ │ + ldrtmi pc, [r9], -r3, lsl #19 @ │ │ │ │ @ instruction: 0xf8c82238 │ │ │ │ @ instruction: 0xf7db0278 │ │ │ │ - @ instruction: 0xf8d8ec24 │ │ │ │ + @ instruction: 0xf8d8ec3a │ │ │ │ tstcs r7, #120, 4 @ 0x80000007 │ │ │ │ @ instruction: 0xe69f74bb │ │ │ │ @ instruction: 0xf7ec6b40 │ │ │ │ - stmdbvs r8!, {r0, r2, r3, r4, r5, r6, r8, fp, ip, sp, lr, pc}^ │ │ │ │ + stmdbvs r8!, {r0, r2, r5, r9, fp, ip, sp, lr, pc}^ │ │ │ │ ldmdami ip, {r0, r1, r2, r3, r4, r8, r9, sl, sp, lr, pc} │ │ │ │ vhsub.s8 d18, d0, d8 │ │ │ │ @ instruction: 0xf04f613c │ │ │ │ ldrbtmi r0, [r8], #-3073 @ 0xfffff3ff │ │ │ │ eorsgt pc, r1, sp, lsl #17 │ │ │ │ - @ instruction: 0xf8c0f7ec │ │ │ │ + @ instruction: 0xf968f7ec │ │ │ │ movwne pc, #4672 @ 0x1240 @ │ │ │ │ andls r8, lr, r3, asr #1 │ │ │ │ addhi r6, r6, r7 │ │ │ │ str r6, [ip, -r8, ror #18] │ │ │ │ - ldc 7, cr15, [lr, #876] @ 0x36c │ │ │ │ + ldc 7, cr15, [r6, #876]! @ 0x36c │ │ │ │ @ instruction: 0x46334a12 │ │ │ │ vtst.8 d20, d0, d2 │ │ │ │ ldrbtmi r5, [sl], #-511 @ 0xfffffe01 │ │ │ │ - @ instruction: 0xf7ea4478 │ │ │ │ - pld [fp, fp, asr #31] │ │ │ │ - svclt 0x0000eb5a │ │ │ │ - muleq r3, r4, sl │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ + @ instruction: 0xf7eb4478 │ │ │ │ + pld [fp, pc @ ] │ │ │ │ + svclt 0x0000eb6e │ │ │ │ + andeq r0, r3, ip, lsl #22 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + strdeq r0, [r3], -ip │ │ │ │ + ldrdeq r3, [r3], -r8 │ │ │ │ + andeq r5, r3, r0, ror pc │ │ │ │ andeq r0, r3, r4, lsl #21 │ │ │ │ - strdeq r3, [r3], -r8 │ │ │ │ - muleq r3, r0, pc @ │ │ │ │ - andeq r0, r3, ip, lsl #20 │ │ │ │ - andeq r3, r2, lr, lsr r5 │ │ │ │ - andeq r0, r0, r0, lsr #5 │ │ │ │ - muleq r3, lr, sp │ │ │ │ - andeq r3, r2, lr, lsr #9 │ │ │ │ - andeq r3, r2, lr, lsl #9 │ │ │ │ - andeq r3, r2, r0, ror r4 │ │ │ │ - andeq r3, r2, lr, lsr r4 │ │ │ │ - andeq r3, r2, r2, lsr #8 │ │ │ │ - andeq r3, r2, r4, lsl r4 │ │ │ │ + andeq r3, r2, sl, ror r7 │ │ │ │ + muleq r0, r8, r2 │ │ │ │ + andeq r5, r3, lr, ror sp │ │ │ │ + andeq r3, r2, sl, ror #13 │ │ │ │ + andeq r3, r2, sl, asr #13 │ │ │ │ + andeq r3, r2, ip, lsr #13 │ │ │ │ + andeq r3, r2, sl, ror r6 │ │ │ │ + andeq r3, r2, lr, asr r6 │ │ │ │ + andeq r3, r2, r0, asr r6 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb7eadc <__bss_end__@@Base+0xfead7ea4> │ │ │ │ + bl feb7ea64 <__bss_end__@@Base+0xfead7ec4> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi fec2b604 <__bss_end__@@Base+0xfeb849cc> │ │ │ │ + blmi fec2b58c <__bss_end__@@Base+0xfeb849ec> │ │ │ │ ldmibmi r0!, {r0, r3, r5, r7, ip, sp, pc} │ │ │ │ - bmi fec38ad8 <__bss_end__@@Base+0xfeb91ea0> │ │ │ │ + bmi fec38a60 <__bss_end__@@Base+0xfeb91ec0> │ │ │ │ ldmdavs fp, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ ldmdavs r2, {r1, r3, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9227 │ │ │ │ cmnlt fp, r0, lsl #4 │ │ │ │ ldrbtmi r4, [fp], #-2988 @ 0xfffff454 │ │ │ │ cmplt sp, sp, lsl r9 │ │ │ │ ldmdblt fp!, {r0, r1, r3, r4, r6, fp, sp, lr} │ │ │ │ strmi r6, [r4], -r3, lsl #16 │ │ │ │ stmdavs r3, {r0, r1, r5, r8, ip, sp, pc}^ │ │ │ │ andsle r2, r1, r1, lsl #22 │ │ │ │ andle r2, ip, r2, lsl #22 │ │ │ │ - blmi fe93a3b4 <__bss_end__@@Base+0xfe89377c> │ │ │ │ + blmi fe93a33c <__bss_end__@@Base+0xfe89379c> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls a0198c <__bss_end__@@Base+0x95ad54> │ │ │ │ + blls a01914 <__bss_end__@@Base+0x95ad74> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ eorlt r8, r9, pc, lsr #2 │ │ │ │ stmibvs r3, {r4, r5, r6, r7, r8, sl, fp, ip, sp, pc} │ │ │ │ rscle r2, pc, r0, lsl #22 │ │ │ │ andcs r4, r1, #162816 @ 0x27c00 │ │ │ │ - blne fe5a2fbc <__bss_end__@@Base+0xfe4fc384> │ │ │ │ + blne fe5a2f44 <__bss_end__@@Base+0xfe4fc3a4> │ │ │ │ @ instruction: 0xf88d447b │ │ │ │ ldc 0, cr2, [r3, #8] │ │ │ │ - bvs fe7aa564 <__bss_end__@@Base+0xfe70392c> │ │ │ │ - mcr 7, 2, pc, cr6, cr11, {6} @ │ │ │ │ - blvc fe4e2fd0 <__bss_end__@@Base+0xfe43c398> │ │ │ │ + bvs fe7aa4ec <__bss_end__@@Base+0xfe70394c> │ │ │ │ + mrc 7, 2, APSR_nzcv, cr0, cr11, {6} │ │ │ │ + blvc fe4e2f58 <__bss_end__@@Base+0xfe43c3b8> │ │ │ │ andmi pc, r0, #111 @ 0x6f │ │ │ │ - bleq 2231dc <__bss_end__@@Base+0x17c5a4> │ │ │ │ - blvc ff063550 <__bss_end__@@Base+0xfefbc918> │ │ │ │ - bcc fe4631c0 <__bss_end__@@Base+0xfe3bc588> │ │ │ │ + bleq 223164 <__bss_end__@@Base+0x17c5c4> │ │ │ │ + blvc ff0634d8 <__bss_end__@@Base+0xfefbc938> │ │ │ │ + bcc fe463148 <__bss_end__@@Base+0xfe3bc5a8> │ │ │ │ svclt 0x00284293 │ │ │ │ tstlt lr, r3, lsl r6 │ │ │ │ movwvs pc, #67 @ 0x43 @ │ │ │ │ eorseq pc, r0, #4, 2 │ │ │ │ ldrdeq pc, [sl], -r4 @ │ │ │ │ strcs r9, [r0], -r3 │ │ │ │ @ instruction: 0xf1049301 │ │ │ │ ldm r2, {r3, r4, r5, r8, r9} │ │ │ │ - bge 167994 <__bss_end__@@Base+0xc0d5c> │ │ │ │ - blmi feb62fdc <__bss_end__@@Base+0xfeabc3a4> │ │ │ │ + bge 16791c <__bss_end__@@Base+0xc0d7c> │ │ │ │ + blmi feb62f64 <__bss_end__@@Base+0xfeabc3c4> │ │ │ │ ldc 6, cr4, [r4, #444] @ 0x1bc │ │ │ │ stm r2, {r1, r2, r3, r5, r7, r8, r9, fp, ip, lr} │ │ │ │ andcs r0, fp, #3 │ │ │ │ muleq r3, r3, r8 │ │ │ │ vldr d10, [r4, #28] │ │ │ │ vmov.u16 r6, d23[2] │ │ │ │ vldr d4, [r4, #784] @ 0x310 │ │ │ │ @@ -37109,31 +37104,31 @@ │ │ │ │ vcvt.f32.f64 s2, d0 │ │ │ │ vcvt.f32.f64 s12, d6 │ │ │ │ @ instruction: 0xf88d7bc7 │ │ │ │ mrc 0, 5, r3, cr7, cr8, {2} │ │ │ │ @ instruction: 0xf8d42bc2 │ │ │ │ cdp 2, 11, cr3, cr7, cr8, {4} │ │ │ │ tstls r5, #197632 @ 0x30400 │ │ │ │ - bcc 4e3084 <__bss_end__@@Base+0x43c44c> │ │ │ │ + bcc 4e300c <__bss_end__@@Base+0x43c46c> │ │ │ │ stc 3, cr2, [sp, #4] │ │ │ │ @ instruction: 0xf88d4a1a │ │ │ │ stc 0, cr3, [sp, #512] @ 0x200 │ │ │ │ vstr s10, [sp, #108] @ 0x6c │ │ │ │ vstr s12, [sp, #112] @ 0x70 │ │ │ │ vstr s14, [sp, #116] @ 0x74 │ │ │ │ vstr s4, [sp, #120] @ 0x78 │ │ │ │ @ instruction: 0xf7db1a1f │ │ │ │ - @ instruction: 0x4639eab0 │ │ │ │ + ldrtmi lr, [r9], -r4, asr #21 │ │ │ │ stmib sp, {r3, r5, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7e66623 │ │ │ │ - stmdacs r0, {r0, r1, r3, r4, r6, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmdacs r0, {r0, r1, r2, r3, r6, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ svcge 0x004af43f │ │ │ │ @ instruction: 0xf1044638 │ │ │ │ @ instruction: 0xf7e50140 │ │ │ │ - @ instruction: 0xf8d4fa0b │ │ │ │ + @ instruction: 0xf8d4fdff │ │ │ │ stmdami sl, {r4, r7, r9, sp}^ │ │ │ │ adccc pc, ip, #212, 16 @ 0xd40000 │ │ │ │ movwcs pc, #35012 @ 0x88c4 @ │ │ │ │ @ instruction: 0xf8d44478 │ │ │ │ @ instruction: 0xf8c422a8 │ │ │ │ @ instruction: 0xf8c42320 │ │ │ │ @ instruction: 0xf8d43324 │ │ │ │ @@ -37189,148 +37184,148 @@ │ │ │ │ @ instruction: 0xf8d41364 │ │ │ │ @ instruction: 0xf8d42300 │ │ │ │ @ instruction: 0xf8c412fc │ │ │ │ @ instruction: 0xf8c40370 │ │ │ │ @ instruction: 0xf8c41374 │ │ │ │ @ instruction: 0xf8c42378 │ │ │ │ @ instruction: 0xe6c5337c │ │ │ │ - ldc 7, cr15, [r6], {219} @ 0xdb │ │ │ │ + stc 7, cr15, [lr], #-876 @ 0xfffffc94 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ ldmvc sl, {r0, r3, r6, r7, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0x41223456 │ │ │ │ - andeq r2, r3, r0, lsr #29 │ │ │ │ - andeq r0, r3, r4, lsl r7 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r5, r3, sl, lsr #24 │ │ │ │ - andeq r0, r3, r4, ror #13 │ │ │ │ - andeq r5, r3, r8, ror #23 │ │ │ │ - andeq r5, r3, ip, lsl #21 │ │ │ │ + andeq r2, r3, r0, lsl #29 │ │ │ │ + andeq r0, r3, ip, lsl #15 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r5, r3, sl, lsl #24 │ │ │ │ + andeq r0, r3, ip, asr r7 │ │ │ │ + andeq r5, r3, r8, asr #23 │ │ │ │ + andeq r5, r3, ip, ror #20 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi e3080 <__bss_end__@@Base+0x3c448> │ │ │ │ + blhi e3008 <__bss_end__@@Base+0x3c468> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00b8f8cc │ │ │ │ - bmi fe379618 <__bss_end__@@Base+0xfe2d29e0> │ │ │ │ + bmi fe3795a0 <__bss_end__@@Base+0xfe2d2a00> │ │ │ │ eorsge pc, r4, #14614528 @ 0xdf0000 │ │ │ │ - blmi fe379644 <__bss_end__@@Base+0xfe2d2a0c> │ │ │ │ + blmi fe3795cc <__bss_end__@@Base+0xfe2d2a2c> │ │ │ │ ldrbtmi r4, [sl], #1146 @ 0x47a │ │ │ │ strmi fp, [r4], -r7, lsl #1 │ │ │ │ strmi r4, [r1], -sp, lsl #12 │ │ │ │ @ instruction: 0xf8da58d3 │ │ │ │ ldmdavs fp, {} @ │ │ │ │ @ instruction: 0xf04f9305 │ │ │ │ svcls 0x00120300 │ │ │ │ ldrdlt pc, [ip], #-141 @ 0xffffff73 │ │ │ │ ldc2 7, cr15, [r6, #-948] @ 0xfffffc4c │ │ │ │ - blcs 41c14 │ │ │ │ + blcs 41b9c │ │ │ │ rschi pc, r2, r0 │ │ │ │ strbmi r4, [fp], -r6, lsl #12 │ │ │ │ strbmi r4, [r2], -r0, lsr #12 │ │ │ │ @ instruction: 0xf8cd4629 │ │ │ │ strls fp, [r0, -r4] │ │ │ │ - blx ff0e5c1c <__bss_end__@@Base+0xff03efe4> │ │ │ │ + blx ff0e5ba4 <__bss_end__@@Base+0xff03f004> │ │ │ │ rsbsmi pc, r8, #14024704 @ 0xd60000 │ │ │ │ - blvs 1e3290 <__bss_end__@@Base+0x13c658> │ │ │ │ - blhi 263284 <__bss_end__@@Base+0x1bc64c> │ │ │ │ - blhi 1263508 <__bss_end__@@Base+0x11bc8d0> │ │ │ │ + blvs 1e3218 <__bss_end__@@Base+0x13c678> │ │ │ │ + blhi 26320c <__bss_end__@@Base+0x1bc66c> │ │ │ │ + blhi 1263490 <__bss_end__@@Base+0x11bc8f0> │ │ │ │ stmdavs r3!, {r2, r3, r4, r5, r7, r8, r9, ip, sp, pc} │ │ │ │ vqrdmulh.s d18, d0, d0 │ │ │ │ - ldc 0, cr8, [pc, #748] @ 27f28 │ │ │ │ + ldc 0, cr8, [pc, #748] @ 27eb0 │ │ │ │ vcmp.f64 d7, d28 │ │ │ │ vsqrt.f64 d24, d7 │ │ │ │ @ instruction: 0xdc04fa10 │ │ │ │ mlacc r8, r4, r8, pc @ │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ @ instruction: 0xf89480af │ │ │ │ mvnslt r3, r9, lsr #32 │ │ │ │ andscs r6, r8, r2, ror #21 │ │ │ │ ldmdavc r1, {r2, r4, r7, r9, sl, lr}^ │ │ │ │ andcs pc, r3, r0, lsl fp @ │ │ │ │ - bl ff079494 <__bss_end__@@Base+0xfefd285c> │ │ │ │ + bl ff07941c <__bss_end__@@Base+0xfefd287c> │ │ │ │ sbceq r0, r9, r1, asr #3 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ cdp 0, 11, cr8, cr7, cr1, {5} │ │ │ │ @ instruction: 0xf8dc7bc8 │ │ │ │ stmiane sl, {r2, r4, ip, sp}^ │ │ │ │ - bvc 2e33cc <__bss_end__@@Base+0x23c794> │ │ │ │ + bvc 2e3354 <__bss_end__@@Base+0x23c7b4> │ │ │ │ addsmi r3, sl, #56, 6 @ 0xe0000000 │ │ │ │ - bvc fe223664 <__bss_end__@@Base+0xfe17ca2c> │ │ │ │ - bvc 163198 <__bss_end__@@Base+0xbc560> │ │ │ │ + bvc fe2235ec <__bss_end__@@Base+0xfe17ca4c> │ │ │ │ + bvc 163120 <__bss_end__@@Base+0xbc580> │ │ │ │ @ instruction: 0xf10cd1f6 │ │ │ │ strmi r0, [r4, #3096] @ 0xc18 │ │ │ │ movwcs sp, #495 @ 0x1ef │ │ │ │ - blvs e32ac <__bss_end__@@Base+0x3c674> │ │ │ │ + blvs e3234 <__bss_end__@@Base+0x3c694> │ │ │ │ eorcc pc, r8, r4, lsl #17 │ │ │ │ ldc 4, cr2, [r7, #4] │ │ │ │ strtmi r7, [r9], -r4, lsl #22 │ │ │ │ - blpl 63308 <__bss_start@@Base+0x8268> │ │ │ │ - bleq 1263770 <__bss_end__@@Base+0x11bcb38> │ │ │ │ - blvs e3310 <__bss_end__@@Base+0x3c6d8> │ │ │ │ + blpl 63290 <__bss_start@@Base+0x8288> │ │ │ │ + bleq 12636f8 <__bss_end__@@Base+0x11bcb58> │ │ │ │ + blvs e3298 <__bss_end__@@Base+0x3c6f8> │ │ │ │ svcmi 0x0058aa02 │ │ │ │ - blvc ff223798 <__bss_end__@@Base+0xff17cb60> │ │ │ │ - blpl ff1a379c <__bss_end__@@Base+0xff0fcb64> │ │ │ │ + blvc ff223720 <__bss_end__@@Base+0xff17cb80> │ │ │ │ + blpl ff1a3724 <__bss_end__@@Base+0xff0fcb84> │ │ │ │ subeq pc, r0, r6, lsl #2 │ │ │ │ - blvs ff1e37a4 <__bss_end__@@Base+0xff13cb6c> │ │ │ │ + blvs ff1e372c <__bss_end__@@Base+0xff13cb8c> │ │ │ │ stc 4, cr4, [sp, #508] @ 0x1fc │ │ │ │ vstr s14, [sp, #8] │ │ │ │ vstr s10, [sp, #16] │ │ │ │ - @ instruction: 0xf7e56a03 │ │ │ │ - ldc 13, cr15, [r7, #516] @ 0x204 │ │ │ │ + @ instruction: 0xf7e66a03 │ │ │ │ + @ instruction: 0xed97f975 │ │ │ │ strmi r7, [r5], -ip, lsl #22 │ │ │ │ - blvc ff0637b8 <__bss_end__@@Base+0xfefbcb80> │ │ │ │ - blx 4638ac <__bss_end__@@Base+0x3bcc74> │ │ │ │ + blvc ff063740 <__bss_end__@@Base+0xfefbcba0> │ │ │ │ + blx 463834 <__bss_end__@@Base+0x3bcc94> │ │ │ │ stccs 12, cr13, [r0, #-292] @ 0xfffffedc │ │ │ │ @ instruction: 0x4325d16c │ │ │ │ - bmi 12d6324 <__bss_end__@@Base+0x122f6ec> │ │ │ │ - blmi 11ef598 <__bss_end__@@Base+0x1148960> │ │ │ │ + bmi 12d62ac <__bss_end__@@Base+0x122f70c> │ │ │ │ + blmi 11ef520 <__bss_end__@@Base+0x1148980> │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 181d6c <__bss_end__@@Base+0xdb134> │ │ │ │ + blls 181cf4 <__bss_end__@@Base+0xdb154> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ cmnle fp, r0, lsl #6 │ │ │ │ ldc 0, cr11, [sp], #28 │ │ │ │ pop {r1, r8, r9, fp, pc} │ │ │ │ ldmdavs r3!, {r4, r5, r6, r7, r8, r9, sl, fp, pc}^ │ │ │ │ mvnle r2, r1, lsl #22 │ │ │ │ - vldr d4, [pc, #256] @ 27e20 │ │ │ │ + vldr d4, [pc, #256] @ 27da8 │ │ │ │ ldrbtmi r1, [fp], #-2869 @ 0xfffff4cb │ │ │ │ rsbsmi pc, r8, #14024704 @ 0xd60000 │ │ │ │ - bleq 1e3378 <__bss_end__@@Base+0x13c740> │ │ │ │ + bleq 1e3300 <__bss_end__@@Base+0x13c760> │ │ │ │ @ instruction: 0xf7db6a9f │ │ │ │ - ldc 12, cr14, [pc, #344] @ 27e8c │ │ │ │ + ldc 12, cr14, [pc, #384] @ 27e3c │ │ │ │ @ instruction: 0xf06f7b32 │ │ │ │ cdp 2, 2, cr4, cr0, cr0, {0} │ │ │ │ vmov.f64 d23, #199 @ 0xbe380000 -0.1796875 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ addsmi r3, r3, #144, 20 @ 0x90000 │ │ │ │ ldrmi fp, [r3], -r8, lsr #30 │ │ │ │ @ instruction: 0xf043b10f │ │ │ │ - bmi d40954 <__bss_end__@@Base+0xc99d1c> │ │ │ │ + bmi d408dc <__bss_end__@@Base+0xc99d3c> │ │ │ │ ldrbtmi r6, [sl], #-355 @ 0xfffffe9d │ │ │ │ - blcs 41da8 │ │ │ │ - blmi cdc084 <__bss_end__@@Base+0xc3544c> │ │ │ │ + blcs 41d30 │ │ │ │ + blmi cdc00c <__bss_end__@@Base+0xc3546c> │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ bicle r2, r4, r0, lsl #20 │ │ │ │ ldrdeq pc, [sl], -r6 @ │ │ │ │ tstpeq r0, r4, lsl #2 @ p-variant is OBSOLETE │ │ │ │ strthi r8, [r2], #-3570 @ 0xfffff20e │ │ │ │ ldmdbvs r8, {r5, r6, r7, r8, sp, lr} │ │ │ │ - @ instruction: 0xf8dcf7e6 │ │ │ │ + ldc2l 7, cr15, [r0], {230} @ 0xe6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ - blx fed25d3a <__bss_end__@@Base+0xfec7f102> │ │ │ │ - beq 4635a4 <__bss_end__@@Base+0x3bc96c> │ │ │ │ - blvs 7e3408 <__bss_end__@@Base+0x73c7d0> │ │ │ │ - blvc ff223870 <__bss_end__@@Base+0xff17cc38> │ │ │ │ - blpl 3633f0 <__bss_end__@@Base+0x2bc7b8> │ │ │ │ - blvc 1e3634 <__bss_end__@@Base+0x13c9fc> │ │ │ │ - blvs 1a37b8 <__bss_end__@@Base+0xfcb80> │ │ │ │ - blhi ff1e3870 <__bss_end__@@Base+0xff13cc38> │ │ │ │ - blx 463968 <__bss_end__@@Base+0x3bcd30> │ │ │ │ + blx fed25cc2 <__bss_end__@@Base+0xfec7f122> │ │ │ │ + beq 46352c <__bss_end__@@Base+0x3bc98c> │ │ │ │ + blvs 7e3390 <__bss_end__@@Base+0x73c7f0> │ │ │ │ + blvc ff2237f8 <__bss_end__@@Base+0xff17cc58> │ │ │ │ + blpl 363378 <__bss_end__@@Base+0x2bc7d8> │ │ │ │ + blvc 1e35bc <__bss_end__@@Base+0x13ca1c> │ │ │ │ + blvs 1a3740 <__bss_end__@@Base+0xfcba0> │ │ │ │ + blhi ff1e37f8 <__bss_end__@@Base+0xff13cc58> │ │ │ │ + blx 4638f0 <__bss_end__@@Base+0x3bcd50> │ │ │ │ strtmi fp, [r5], -r8, asr #30 │ │ │ │ stccs 5, cr13, [r0], {159} @ 0x9f │ │ │ │ ldr sp, [r2, r1, lsr #1]! │ │ │ │ ldrb r2, [r6, -r0, lsl #8]! │ │ │ │ ldceq 1, cr15, [r8], {12} │ │ │ │ @ instruction: 0xf43f4584 │ │ │ │ @ instruction: 0xf10caf6c │ │ │ │ @@ -37338,83 +37333,83 @@ │ │ │ │ @ instruction: 0xe766d1f6 │ │ │ │ @ instruction: 0xf7ff4630 │ │ │ │ str pc, [lr, r3, lsl #27] │ │ │ │ vpadd.i8 d20, d0, d6 │ │ │ │ ldmdbmi r6, {r1, r3, r6, r7, r9, sp, lr} │ │ │ │ ldrbtmi r4, [fp], #-2070 @ 0xfffff7ea │ │ │ │ ldrbtmi r4, [r8], #-1145 @ 0xfffffb87 │ │ │ │ - stmib r8, {r0, r1, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - b ffae5d54 <__bss_end__@@Base+0xffa3f11c> │ │ │ │ + ldmib lr, {r0, r1, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bl e5cdc <__bss_end__@@Base+0x3f13c> │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ teqcc r3, #-872415232 @ 0xcc000000 │ │ │ │ andsmi r3, r3, r3, lsr r3 │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ ldmvc sl, {r0, r3, r6, r7, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0x41223456 │ │ │ │ andeq r0, r0, r0 │ │ │ │ addsmi r8, r6, r0 │ │ │ │ - andeq r0, r3, r0, lsr #8 │ │ │ │ - andeq r5, r3, r6, asr #18 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r5, r3, r0, ror #16 │ │ │ │ - andeq r0, r3, r4, lsl #6 │ │ │ │ - andeq r5, r3, r6, lsl #16 │ │ │ │ - andeq r2, r3, r2, lsr sl │ │ │ │ - andeq r5, r3, r8, asr #15 │ │ │ │ - andeq lr, r2, lr, ror #13 │ │ │ │ - andeq r2, r2, r4, asr #29 │ │ │ │ - andeq r2, r2, r6, ror #29 │ │ │ │ + muleq r3, r8, r4 │ │ │ │ + andeq r5, r3, r6, lsr #18 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r5, r3, r0, asr #16 │ │ │ │ + andeq r0, r3, ip, ror r3 │ │ │ │ + andeq r5, r3, r6, ror #15 │ │ │ │ + andeq r2, r3, r2, lsl sl │ │ │ │ + andeq r5, r3, r8, lsr #15 │ │ │ │ + andeq lr, r2, r6, ror #12 │ │ │ │ + andeq r3, r2, r0, lsl #2 │ │ │ │ + andeq r3, r2, r2, lsr #2 │ │ │ │ ldrbtmi r4, [fp], #-2819 @ 0xfffff4fd │ │ │ │ stmdacc r0, {r3, r4, r8, fp, sp, lr} │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq r5, r3, lr, ror #13 │ │ │ │ + andeq r5, r3, lr, asr #13 │ │ │ │ ldrbtmi r4, [fp], #-2817 @ 0xfffff4ff │ │ │ │ @ instruction: 0x47706398 │ │ │ │ - ldrdeq r5, [r3], -sl │ │ │ │ + @ instruction: 0x000356ba │ │ │ │ ldrbtmi r4, [fp], #-2817 @ 0xfffff4ff │ │ │ │ @ instruction: 0x47706918 │ │ │ │ - andeq r5, r3, lr, asr #13 │ │ │ │ + andeq r5, r3, lr, lsr #13 │ │ │ │ ldrbtmi r4, [fp], #-2817 @ 0xfffff4ff │ │ │ │ @ instruction: 0x47706818 │ │ │ │ - andeq r5, r3, r2, asr #13 │ │ │ │ + andeq r5, r3, r2, lsr #13 │ │ │ │ ldrbtmi r4, [fp], #-2817 @ 0xfffff4ff │ │ │ │ @ instruction: 0x47706018 │ │ │ │ - andeq r2, r3, r6, lsl r9 │ │ │ │ + strdeq r2, [r3], -r6 │ │ │ │ vst3.8 {d27,d29,d31}, [pc], r8 │ │ │ │ - bl feb7f084 <__bss_end__@@Base+0xfead844c> │ │ │ │ + bl feb7f00c <__bss_end__@@Base+0xfead846c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf7ff0ff8 │ │ │ │ teqplt r8, sp @ @ p-variant is OBSOLETE │ │ │ │ strmi r4, [r1], -r4, lsl #22 │ │ │ │ ldmdavs r8, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0x4008e8bd │ │ │ │ - bllt ff265e54 <__bss_end__@@Base+0xff1bf21c> │ │ │ │ + bllt ff265ddc <__bss_end__@@Base+0xff1bf23c> │ │ │ │ svclt 0x0000bd08 │ │ │ │ - muleq r3, r4, r6 │ │ │ │ + andeq r5, r3, r4, ror r6 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb7f0b0 <__bss_end__@@Base+0xfead8478> │ │ │ │ + bl feb7f038 <__bss_end__@@Base+0xfead8498> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r7, #-960] @ 0xfffffc40 │ │ │ │ strmi r4, [r1], -r4, lsl #12 │ │ │ │ stmdavs r8!, {r0, r2, r3, r4, r5, r6, sl, lr} │ │ │ │ - blx 825e7a <__bss_end__@@Base+0x77f242> │ │ │ │ + blx 825e02 <__bss_end__@@Base+0x77f262> │ │ │ │ stmdavs r8!, {r3, r5, r8, ip, sp, pc} │ │ │ │ pop {r0, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7ed4038 │ │ │ │ fldmdbxlt r8!, {d11-d97} @ Deprecated │ │ │ │ - andeq r5, r3, ip, ror #12 │ │ │ │ + andeq r5, r3, ip, asr #12 │ │ │ │ ldrbtmi r4, [fp], #-2818 @ 0xfffff4fe │ │ │ │ - bleq 3634ec <__bss_end__@@Base+0x2bc8b4> │ │ │ │ + bleq 363474 <__bss_end__@@Base+0x2bc8d4> │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq r5, r3, lr, asr #12 │ │ │ │ + andeq r5, r3, lr, lsr #12 │ │ │ │ ldrbtmi r4, [fp], #-2817 @ 0xfffff4ff │ │ │ │ @ instruction: 0x47706858 │ │ │ │ - andeq r5, r3, lr, lsr r6 │ │ │ │ + andeq r5, r3, lr, lsl r6 │ │ │ │ ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00d8f8cc │ │ │ │ @ instruction: 0x46174d51 │ │ │ │ @ instruction: 0x461e4a51 │ │ │ │ ldrbtmi r4, [sp], #-2897 @ 0xfffff4af │ │ │ │ @@ -37430,158 +37425,158 @@ │ │ │ │ andne lr, pc, #3227648 @ 0x314000 │ │ │ │ stmib r5, {r2, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7ed3711 │ │ │ │ ldmib r5, {r0, r3, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ stmib r5, {r1, r2, r8, r9, sp}^ │ │ │ │ eorvs r2, r8, r6, lsl r3 │ │ │ │ andcs r2, r0, #0, 6 │ │ │ │ - bge 522668 <__bss_end__@@Base+0x47ba30> │ │ │ │ + bge 5225f0 <__bss_end__@@Base+0x47ba50> │ │ │ │ tstcs sl, #3227648 @ 0x314000 │ │ │ │ @ instruction: 0xf8c54653 │ │ │ │ @ instruction: 0xb1a4a060 │ │ │ │ - b 4e5ed0 <__bss_end__@@Base+0x43f298> │ │ │ │ + b ae5e58 <__bss_end__@@Base+0xa3f2b8> │ │ │ │ stmdavs r3, {r1, r5, fp, ip, sp, lr} │ │ │ │ @ instruction: 0xf8337825 │ │ │ │ ldreq r2, [r0], #18 │ │ │ │ @ instruction: 0xf814d506 │ │ │ │ @ instruction: 0xf8335f01 │ │ │ │ @ instruction: 0xf41cc015 │ │ │ │ mvnsle r5, r0, lsl #30 │ │ │ │ svclt 0x00162d00 │ │ │ │ movwcs r4, #1698 @ 0x6a2 │ │ │ │ ldcmi 3, cr2, [r3], #-4 │ │ │ │ ldrbtmi r1, [ip], #-3185 @ 0xfffff38f │ │ │ │ - blmi cc0820 <__bss_end__@@Base+0xc19be8> │ │ │ │ + blmi cc07a8 <__bss_end__@@Base+0xc19c08> │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ svclt 0x00186263 │ │ │ │ eorle r6, lr, r3, rrx │ │ │ │ @ instruction: 0xf1b94b2e │ │ │ │ ldrbtmi r3, [fp], #-4095 @ 0xfffff001 │ │ │ │ eorsle r6, r0, ip, lsl r8 │ │ │ │ strbmi fp, [r2], -ip, asr #3 │ │ │ │ andcs r4, r0, r1, asr r6 │ │ │ │ - cdp2 7, 15, cr15, cr14, cr3, {7} │ │ │ │ + blx ffce5ed4 <__bss_end__@@Base+0xffc3f334> │ │ │ │ stmdacs r0, {r2, r9, sl, lr} │ │ │ │ stcmi 0, cr13, [r8, #-208]! @ 0xffffff30 │ │ │ │ ldrtmi r4, [r2], -fp, asr #12 │ │ │ │ ldrbtmi r4, [sp], #-1593 @ 0xfffff9c7 │ │ │ │ - @ instruction: 0xff40f7e5 │ │ │ │ + blx d65ef2 <__bss_end__@@Base+0xcbf352> │ │ │ │ movtlt r6, #296 @ 0x128 │ │ │ │ - @ instruction: 0xf7e54669 │ │ │ │ - @ instruction: 0xf8bdff9d │ │ │ │ + @ instruction: 0xf7e64669 │ │ │ │ + @ instruction: 0xf8bdfb91 │ │ │ │ @ instruction: 0xf8bd2000 │ │ │ │ rscvs r3, sl, r2 │ │ │ │ andcs r6, r0, fp, lsr #14 │ │ │ │ - blmi 6ba868 <__bss_end__@@Base+0x613c30> │ │ │ │ + blmi 6ba7f0 <__bss_end__@@Base+0x613c50> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 8205c <__bss_start@@Base+0x26fbc> │ │ │ │ + blls 81fe4 <__bss_start@@Base+0x26fdc> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xd1250300 │ │ │ │ pop {r1, ip, sp, pc} │ │ │ │ stmdblt r2!, {r4, r5, r6, r7, r8, r9, sl, pc}^ │ │ │ │ svccc 0x00fff1b9 │ │ │ │ mvnle r6, r2, rrx │ │ │ │ - b 1165f7c <__bss_end__@@Base+0x10bf344> │ │ │ │ + b 1565f04 <__bss_end__@@Base+0x14bf364> │ │ │ │ @ instruction: 0xf7dbe7e9 │ │ │ │ - strmi lr, [r1], r2, asr #20 │ │ │ │ + pkhtbmi lr, r1, r2, asr #20 │ │ │ │ bicle r2, sl, r0, lsl #24 │ │ │ │ @ instruction: 0xf7ffe7e3 │ │ │ │ stmiavs r6!, {r0, r3, r5, r6, r8, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x4620e7be │ │ │ │ - blx 465fbe <__bss_end__@@Base+0x3bf386> │ │ │ │ + @ instruction: 0xff04f7e4 │ │ │ │ rscscc pc, pc, pc, asr #32 │ │ │ │ - bmi 3e1f9c <__bss_end__@@Base+0x33b364> │ │ │ │ + bmi 3e1f24 <__bss_end__@@Base+0x33b384> │ │ │ │ stmdami lr, {r8, r9, sp} │ │ │ │ bicne pc, r1, r0, asr #4 │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - blx ffce5fee <__bss_end__@@Base+0xffc3f3b6> │ │ │ │ - svc 0x0080f7da │ │ │ │ - ldmib r8!, {r0, r1, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - andeq r5, r3, sl, lsl r6 │ │ │ │ - strdeq r0, [r3], -r0 @ │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - muleq r3, sl, r5 │ │ │ │ - strdeq r2, [r3], -r4 │ │ │ │ - ldrdeq r2, [r3], -lr │ │ │ │ - andeq r5, r3, lr, asr r5 │ │ │ │ - andeq r0, r3, r4, lsl r0 │ │ │ │ - muleq r2, r4, ip │ │ │ │ - andeq r2, r2, r2, ror #24 │ │ │ │ + @ instruction: 0xffe6f7ea │ │ │ │ + svc 0x0094f7da │ │ │ │ + ldmib r0, {r0, r1, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + strdeq r5, [r3], -sl │ │ │ │ + andeq r0, r3, r8, ror #2 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r5, r3, sl, ror r5 │ │ │ │ + ldrdeq r2, [r3], -r4 │ │ │ │ + @ instruction: 0x000327be │ │ │ │ + andeq r5, r3, lr, lsr r5 │ │ │ │ + andeq r0, r3, ip, lsl #1 │ │ │ │ + ldrdeq r2, [r2], -r0 │ │ │ │ + muleq r2, lr, lr │ │ │ │ ldrbtmi r4, [fp], #-2819 @ 0xfffff4fd │ │ │ │ - bleq e3688 <__bss_end__@@Base+0x3ca50> │ │ │ │ - blne 16368c <__bss_end__@@Base+0xbca54> │ │ │ │ + bleq e3610 <__bss_end__@@Base+0x3ca70> │ │ │ │ + blne 163614 <__bss_end__@@Base+0xbca74> │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq r2, r3, r2, lsl r7 │ │ │ │ + strdeq r2, [r3], -r2 @ │ │ │ │ andcs r4, r0, #3072 @ 0xc00 │ │ │ │ addsvs r4, sl, #2063597568 @ 0x7b000000 │ │ │ │ - bleq 1e36a0 <__bss_end__@@Base+0x13ca68> │ │ │ │ + bleq 1e3628 <__bss_end__@@Base+0x13ca88> │ │ │ │ svclt 0x00004770 │ │ │ │ - muleq r3, ip, r4 │ │ │ │ + andeq r5, r3, ip, ror r4 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8acb0 <__bss_end__@@Base+0xfeae4078> │ │ │ │ + bl feb8ac38 <__bss_end__@@Base+0xfeae4098> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - bmi 76c010 <__bss_end__@@Base+0x6c53d8> │ │ │ │ - blmi 7942cc <__bss_end__@@Base+0x6ed694> │ │ │ │ + bmi 76bf98 <__bss_end__@@Base+0x6c53f8> │ │ │ │ + blmi 794254 <__bss_end__@@Base+0x6ed6b4> │ │ │ │ ldrbtmi r2, [sl], #-256 @ 0xffffff00 │ │ │ │ ldcmi 6, cr4, [ip], {104} @ 0x68 │ │ │ │ ldrbtmi r5, [ip], #-2259 @ 0xfffff72d │ │ │ │ movwls r6, #22555 @ 0x581b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - svc 0x00c4f7da │ │ │ │ + svc 0x00daf7da │ │ │ │ ldrdeq lr, [r2, -sp] │ │ │ │ - blx ff4e4158 <__bss_end__@@Base+0xff43d520> │ │ │ │ - blvc 4a3754 <__bss_end__@@Base+0x3fcb1c> │ │ │ │ - bleq 5e31e0 <__bss_end__@@Base+0x53c5a8> │ │ │ │ + blx ff4e40e0 <__bss_end__@@Base+0xff43d540> │ │ │ │ + blvc 4a36dc <__bss_end__@@Base+0x3fcb3c> │ │ │ │ + bleq 5e3168 <__bss_end__@@Base+0x53c5c8> │ │ │ │ ldrdeq lr, [r0, -sp] │ │ │ │ - blhi 223afc <__bss_end__@@Base+0x17cec4> │ │ │ │ - blx ff26416c <__bss_end__@@Base+0xff1bd534> │ │ │ │ - bleq 6231f0 <__bss_end__@@Base+0x57c5b8> │ │ │ │ + blhi 223a84 <__bss_end__@@Base+0x17cee4> │ │ │ │ + blx ff2640f4 <__bss_end__@@Base+0xff1bd554> │ │ │ │ + bleq 623178 <__bss_end__@@Base+0x57c5d8> │ │ │ │ movwcs r4, #6672 @ 0x1a10 │ │ │ │ - blmi 380b80 <__bss_end__@@Base+0x2d9f48> │ │ │ │ + blmi 380b08 <__bss_end__@@Base+0x2d9f68> │ │ │ │ mrc 4, 1, r4, cr8, cr10, {3} │ │ │ │ vstr d8, [r4, #28] │ │ │ │ ldmpl r3, {r1, r2, r8, r9, fp, pc}^ │ │ │ │ - blls 18216c <__bss_end__@@Base+0xdb534> │ │ │ │ + blls 1820f4 <__bss_end__@@Base+0xdb554> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, SP_svc │ │ │ │ ldc 0, cr11, [sp], #24 │ │ │ │ vldrlt d8, [r0, #-8] │ │ │ │ - ldmdb r2, {r0, r1, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb sl!, {r0, r1, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ smlawbmi lr, r0, r4, r8 │ │ │ │ - andeq pc, r2, sl, asr #30 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r5, r3, sl, ror #8 │ │ │ │ - andeq pc, r2, ip, lsl #30 │ │ │ │ + andeq pc, r2, r2, asr #31 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r5, r3, sl, asr #8 │ │ │ │ + andeq pc, r2, r4, lsl #31 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb7f33c <__bss_end__@@Base+0xfead8704> │ │ │ │ + bl feb7f2c4 <__bss_end__@@Base+0xfead8724> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [ip, #-960] @ 0xfffffc40 │ │ │ │ strmi r4, [r1], -r4, lsl #12 │ │ │ │ stmdavs r8!, {r0, r2, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf9d9f7ed │ │ │ │ andcs fp, r0, r8, lsl #18 │ │ │ │ stmdavs r8!, {r3, r4, r5, r8, sl, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf7ed4621 │ │ │ │ stmdavs r3, {r0, r3, r5, r6, r9, fp, ip, sp, lr, pc} │ │ │ │ rscsle r2, r6, r0, lsl #22 │ │ │ │ @ instruction: 0xf1a06840 │ │ │ │ - blx fec28170 <__bss_end__@@Base+0xfeb81538> │ │ │ │ + blx fec280f8 <__bss_end__@@Base+0xfeb81558> │ │ │ │ stmdbeq r0, {r7, ip, sp, lr, pc}^ │ │ │ │ svclt 0x0000bd38 │ │ │ │ - andeq r5, r3, r0, ror #7 │ │ │ │ + andeq r5, r3, r0, asr #7 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb7f380 <__bss_end__@@Base+0xfead8748> │ │ │ │ + bl feb7f308 <__bss_end__@@Base+0xfead8768> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ svcvc 0x004b0ff8 │ │ │ │ - blcs 7999c <__bss_start@@Base+0x1e8fc> │ │ │ │ - blcs dc1a8 <__bss_end__@@Base+0x35570> │ │ │ │ + blcs 79924 <__bss_start@@Base+0x1e91c> │ │ │ │ + blcs dc130 <__bss_end__@@Base+0x35590> │ │ │ │ stmibvs r3, {r1, r2, r3, r8, ip, lr, pc}^ │ │ │ │ tstvs sl, r8, lsl #4 │ │ │ │ ldclt 0, cr2, [r0, #-0] │ │ │ │ @ instruction: 0xf00f3030 │ │ │ │ msrlt CPSR_f, r9, ror #19 │ │ │ │ andcs r6, r6, #3719168 @ 0x38c000 │ │ │ │ msreq CPSR_fs, #12779520 @ 0xc30000 │ │ │ │ @@ -37590,45 +37585,45 @@ │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00b8f8cc │ │ │ │ @ instruction: 0xf8dfb089 │ │ │ │ ldrmi r9, [lr], -ip, lsl #2 │ │ │ │ ldrbtmi r4, [r9], #1667 @ 0x683 │ │ │ │ - blls 4f9bf4 <__bss_end__@@Base+0x452fbc> │ │ │ │ + blls 4f9b7c <__bss_end__@@Base+0x452fdc> │ │ │ │ movwls r4, #17943 @ 0x4617 │ │ │ │ movwls r9, #23316 @ 0x5b14 │ │ │ │ @ instruction: 0x9c129b15 │ │ │ │ @ instruction: 0xf8d99306 │ │ │ │ - blls 5a81e8 <__bss_end__@@Base+0x5015b0> │ │ │ │ + blls 5a8170 <__bss_end__@@Base+0x5015d0> │ │ │ │ ldrsbge pc, [ip], #-141 @ 0xffffff73 @ │ │ │ │ movwls r9, #29699 @ 0x7403 │ │ │ │ - blx ba61a8 <__bss_end__@@Base+0xaff570> │ │ │ │ + blx ba6130 <__bss_end__@@Base+0xaff590> │ │ │ │ stmdacs r0, {r0, r2, r9, sl, lr} │ │ │ │ @ instruction: 0x4603d15b │ │ │ │ vst2.8 {d20-d21}, [pc :256], r6 │ │ │ │ vhsub.s8 , q0, q9 │ │ │ │ ldrbtmi r6, [r8], #-355 @ 0xfffffe9d │ │ │ │ - blx ffc661ba <__bss_end__@@Base+0xffbbf582> │ │ │ │ + ldc2 7, cr15, [r8], {235} @ 0xeb │ │ │ │ strtmi r4, [r1], -r4, lsl #12 │ │ │ │ ldrdeq pc, [r0], -r9 │ │ │ │ - blx fe0661cc <__bss_end__@@Base+0xfdfbf594> │ │ │ │ + blx fe066154 <__bss_end__@@Base+0xfdfbf5b4> │ │ │ │ vst1.8 {d20-d22}, [pc], r5 │ │ │ │ tstcs r0, r2, ror #4 │ │ │ │ @ instruction: 0xf7da4620 │ │ │ │ - blmi ba3ef0 <__bss_end__@@Base+0xafd2b8> │ │ │ │ + blmi ba3ed0 <__bss_end__@@Base+0xafd330> │ │ │ │ @ instruction: 0xf8c42201 │ │ │ │ ldrbtmi r8, [fp], #-28 @ 0xffffffe4 │ │ │ │ andcs lr, r0, #196, 18 @ 0x310000 │ │ │ │ adcvs r2, r2, r3, lsl #4 │ │ │ │ - blcs 422a8 │ │ │ │ - blmi a5c340 <__bss_end__@@Base+0x9b5708> │ │ │ │ + blcs 42230 │ │ │ │ + blmi a5c2c8 <__bss_end__@@Base+0x9b5728> │ │ │ │ msreq CPSR_fx, r4, lsl #2 │ │ │ │ ldmdbvs r8, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - cdp2 7, 11, cr15, cr10, cr5, {7} │ │ │ │ + blx febe616c <__bss_end__@@Base+0xfeb3f5cc> │ │ │ │ eorlt pc, r8, r4, lsl #17 │ │ │ │ ldceq 1, cr15, [r0], #-16 │ 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│ │ │ │ andsvc pc, pc, r0, lsl #10 │ │ │ │ @ instruction: 0x4010e8bd │ │ │ │ - mrclt 7, 2, APSR_nzcv, cr12, cr10, {6} │ │ │ │ - andeq r5, r3, ip, lsr #4 │ │ │ │ + mrclt 7, 3, APSR_nzcv, cr0, cr10, {6} │ │ │ │ + andeq r5, r3, ip, lsl #4 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb7f520 <__bss_end__@@Base+0xfead88e8> │ │ │ │ + bl feb7f4a8 <__bss_end__@@Base+0xfead8908> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi 22c2e8 <__bss_end__@@Base+0x1856b0> │ │ │ │ + blmi 22c270 <__bss_end__@@Base+0x1856d0> │ │ │ │ ldrmi r4, [r5], -ip, lsl #12 │ │ │ │ ldrbtmi r4, [fp], #-1537 @ 0xfffff9ff │ │ │ │ @ instruction: 0xf7ed6818 │ │ │ │ @ instruction: 0x462af97d │ │ │ │ tstpvc pc, r0, lsl #10 @ p-variant is OBSOLETE │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7da4038 │ │ │ │ - svclt 0x0000be43 │ │ │ │ - strdeq r5, [r3], -sl │ │ │ │ + svclt 0x0000be57 │ │ │ │ + ldrdeq r5, [r3], -sl │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb7f554 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0xf7e64621 │ │ │ │ + stmdacs r0, {r0, r1, r2, r3, r5, r8, fp, ip, sp, lr, pc} │ │ │ │ ldc 1, cr13, [r5, #964] @ 0x3c4 │ │ │ │ vldr d5, [r5, #24] │ │ │ │ vmovvs.32 d11[1], r7 │ │ │ │ - blvc 1223de8 <__bss_end__@@Base+0x117d1b0> │ │ │ │ + blvc 1223d70 <__bss_end__@@Base+0x117d1d0> │ │ │ │ @ instruction: 0x662b4433 │ │ │ │ - blvc ff063ff0 <__bss_end__@@Base+0xfefbd3b8> │ │ │ │ - blx 4640e4 <__bss_end__@@Base+0x3bd4ac> │ │ │ │ + blvc ff063f78 <__bss_end__@@Base+0xfefbd3d8> │ │ │ │ + blx 46406c <__bss_end__@@Base+0x3bd4cc> │ │ │ │ cdp 4, 11, cr13, cr2, cr7, {0} │ │ │ │ vmov.f64 d6, #68 @ 0x3e200000 0.1562500 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ vmov.i16 d31, #0 @ 0x0000 │ │ │ │ @ instruction: 0xf8df8140 │ │ │ │ andcs r3, r0, #24, 10 @ 0x6000000 │ │ │ │ mrscs r2, (UNDEF: 0) │ │ │ │ @ instruction: 0x661a447b │ │ │ │ tsteq sl, r3, asr #19 │ │ │ │ - blpl 5e3b54 <__bss_end__@@Base+0x53cf1c> │ │ │ │ + blpl 5e3adc <__bss_end__@@Base+0x53cf3c> │ │ │ │ @ instruction: 0xf8dfb936 │ │ │ │ ldrbtmi r3, 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0x40 │ │ │ │ ldmibvc sl, {r0, r2, r3, r8, sl, ip, sp, lr, pc} │ │ │ │ - blcs 623738 <__bss_end__@@Base+0x57cb00> │ │ │ │ + blcs 6236c0 <__bss_end__@@Base+0x57cb20> │ │ │ │ strbmi r4, [r8], -r1, asr #12 │ │ │ │ - stmda r6, {r0, r1, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda r0, {r0, r1, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdavs r8!, {r0, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf81af7ed │ │ │ │ strbmi r6, [r9], -r0, asr #19 │ │ │ │ orrpl pc, r0, #0, 10 │ │ │ │ teqpcc ip, r3 @ @ p-variant is OBSOLETE │ │ │ │ bfi r4, r8, (invalid: 15:11) │ │ │ │ - bcs 606898 <__bss_end__@@Base+0x55fc60> │ │ │ │ - bcs 61e75c <__bss_end__@@Base+0x577b24> │ │ │ │ + bcs 606820 <__bss_end__@@Base+0x55fc80> │ │ │ │ + bcs 61e6e4 <__bss_end__@@Base+0x577b44> │ │ │ │ sbchi pc, r3, r0, lsl #4 │ │ │ │ @ instruction: 0xf853a302 │ │ │ │ strmi r1, [fp], #-34 @ 0xffffffde │ │ │ │ svclt 0x00004718 │ │ │ │ @ instruction: 0xfffffed1 │ │ │ │ @ instruction: 0x000008b1 │ │ │ │ muleq r0, pc, r6 @ │ │ │ │ @@ -37892,44 +37887,44 @@ │ │ │ │ ldrdeq r0, [r0], -fp │ │ │ │ andeq r0, r0, fp, ror r1 │ │ │ │ andeq r0, r0, fp, ror r1 │ │ │ │ andeq r0, r0, r1, asr #4 │ │ │ │ andeq r0, r0, fp, asr #3 │ │ │ │ ldrbtmi r4, [fp], #-3063 @ 0xfffff409 │ │ │ │ @ instruction: 0xf7ed6818 │ │ │ │ - bmi ffde6efc <__bss_end__@@Base+0xffd402c4> │ │ │ │ + bmi ffde6e84 <__bss_end__@@Base+0xffd402e4> │ │ │ │ vsubne.f64 d4, d24, d27 │ │ │ │ svclt 0x0018447a │ │ │ │ ldmpl r3, {r0, sp}^ │ │ │ │ @ instruction: 0xf8dd681a │ │ │ │ subsmi r3, sl, ip, lsl r5 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ ldrbthi pc, [r0], r0, asr #32 @ │ │ │ │ stcpl 2, cr15, [r4, #-52]! @ 0xffffffcc │ │ │ │ - blhi e39a8 <__bss_end__@@Base+0x3cd70> │ │ │ │ + blhi e3930 <__bss_end__@@Base+0x3cd90> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xd1702a9c │ │ │ │ stmiaeq r4!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe4640 │ │ │ │ stmdacs r0, {r0, r1, r3, r4, r6, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ svcge 0x0014f47f │ │ │ │ strcc r6, [r1], -fp, ror #16 │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ stmdbvs fp!, {r0, r1, r2, r3, r5, r7, sl, pc} │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - blmi ff908ce8 <__bss_end__@@Base+0xff8620b0> │ │ │ │ + blmi ff908c70 <__bss_end__@@Base+0xff8620d0> │ │ │ │ ldmdbeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ muleq r7, r4, r8 │ │ │ │ stm r9, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - ldc 0, cr0, [pc, #28] @ 2870c │ │ │ │ - bvs fe7ef618 <__bss_end__@@Base+0xfe7489e0> │ │ │ │ - bleq 1e3d44 <__bss_end__@@Base+0x13d10c> │ │ │ │ + ldc 0, cr0, [pc, #28] @ 28694 │ │ │ │ + bvs fe7ef5a0 <__bss_end__@@Base+0xfe748a00> │ │ │ │ + bleq 1e3ccc <__bss_end__@@Base+0x13d12c> │ │ │ │ @ instruction: 0xf889230f │ │ │ │ @ instruction: 0xf7da3002 │ │ │ │ - ldc 15, cr14, [pc, #440] @ 288bc │ │ │ │ + ldc 15, cr14, [pc, #480] @ 2886c │ │ │ │ @ instruction: 0xf06f7bc6 │ │ │ │ cdp 2, 2, cr4, cr0, cr0, {0} │ │ │ │ vmov.f64 d16, #199 @ 0xbe380000 -0.1796875 │ │ │ │ vnmla.f64 d7, d23, d0 │ │ │ │ addsmi r3, r3, #144, 20 @ 0x90000 │ │ │ │ ldrmi fp, [r3], -r8, lsr #30 │ │ │ │ @ instruction: 0xf043b10f │ │ │ │ @@ -37943,129 +37938,129 @@ │ │ │ │ @ instruction: 0xf8cd69a3 │ │ │ │ @ instruction: 0xf10d004a │ │ │ │ @ instruction: 0xf8ad00b6 │ │ │ │ @ instruction: 0xf8c92048 │ │ │ │ @ instruction: 0xf7fe301c │ │ │ │ stmdacs r0, {r0, r2, r4, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ strhi pc, [fp, #-64]! @ 0xffffffc0 │ │ │ │ - bhi 187b670 <__bss_end__@@Base+0x17d4a38> │ │ │ │ + bhi 187b5f8 <__bss_end__@@Base+0x17d4a58> │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf0404291 │ │ │ │ - bhi fe8c8e94 <__bss_end__@@Base+0xfe82225c> │ │ │ │ + bhi fe8c8e1c <__bss_end__@@Base+0xfe82227c> │ │ │ │ mvnsvc pc, pc, asr #12 │ │ │ │ andle r4, r3, sl, lsl #5 │ │ │ │ addsmi r6, sl, #27, 30 @ 0x6c │ │ │ │ bichi pc, r2, r0, asr #32 │ │ │ │ @ instruction: 0x46494bbe │ │ │ │ ldmdbvs r8, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ vsubw.s8 q9, q0, d20 │ │ │ │ @ instruction: 0xf8c90305 │ │ │ │ @ instruction: 0xf7e53018 │ │ │ │ - stmdacc r0, {r0, r1, r4, r6, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmdacc r0, {r0, r1, r2, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ stmdacs r0, {r0, r1, r2, r6, r9, lr} │ │ │ │ mcrge 4, 5, pc, cr2, cr15, {1} @ │ │ │ │ - blmi fede2248 <__bss_end__@@Base+0xfed3b610> │ │ │ │ + blmi fede21d0 <__bss_end__@@Base+0xfed3b630> │ │ │ │ ldmibmi r6!, {r8, r9, sl, sp} │ │ │ │ @ instruction: 0xf85a4479 │ │ │ │ ldmdavs r8, {r0, r1, ip, sp} │ │ │ │ - ldcl 7, cr15, [r4, #872]! @ 0x368 │ │ │ │ + mcr 7, 0, pc, cr12, cr10, {6} @ │ │ │ │ cdp 6, 11, cr14, cr7, cr0, {5} │ │ │ │ vmov.f64 d6, #64 @ 0x3e000000 0.125 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ @ instruction: 0xf6fffa10 │ │ │ │ cdp 14, 0, cr10, cr6, cr3, {6} │ │ │ │ - vldr s6, [pc, #576] @ 28a08 │ │ │ │ + vldr s6, [pc, #576] @ 28990 │ │ │ │ vstr d2, [r5, #604] @ 0x25c │ │ │ │ vmov.32 r5, d8[1] │ │ │ │ vldr d6, [r5, #920] @ 0x398 │ │ │ │ - vldr d4, [pc, #104] @ 28840 │ │ │ │ + vldr d4, [pc, #104] @ 287c8 │ │ │ │ @ instruction: 0x66283b95 │ │ │ │ - blvs e4078 <__bss_end__@@Base+0x3d440> │ │ │ │ - blpl 2241fc <__bss_end__@@Base+0x17d5c4> │ │ │ │ - blpl 123ff8 <__bss_end__@@Base+0x7d3c0> │ │ │ │ - blpl 6e3e00 <__bss_end__@@Base+0x63d1c8> │ │ │ │ + blvs e4000 <__bss_end__@@Base+0x3d460> │ │ │ │ + blpl 224184 <__bss_end__@@Base+0x17d5e4> │ │ │ │ + blpl 123f80 <__bss_end__@@Base+0x7d3e0> │ │ │ │ + blpl 6e3d88 <__bss_end__@@Base+0x63d1e8> │ │ │ │ @ instruction: 0xf10de6ac │ │ │ │ strbmi r0, [r0], -r4, lsr #17 │ │ │ │ stc2l 7, cr15, [r2, #-1016] @ 0xfffffc08 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ - blmi fe8541ec <__bss_end__@@Base+0xfe7ad5b4> │ │ │ │ + blmi fe854174 <__bss_end__@@Base+0xfe7ad5d4> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ strbmi r8, [r0], -r5, lsr #8 │ │ │ │ @ instruction: 0xf7fe3601 │ │ │ │ @ instruction: 0x4601fcfb │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ - blmi fe6c8bac <__bss_end__@@Base+0xfe621f74> │ │ │ │ + blmi fe6c8b34 <__bss_end__@@Base+0xfe621f94> │ │ │ │ ldmdavs r8, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xff06f7ec │ │ │ │ rsbshi pc, r8, #208, 16 @ 0xd00000 │ │ │ │ @ instruction: 0xf1b84607 │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ @ instruction: 0xf1088422 │ │ │ │ @ instruction: 0xf7e40010 │ │ │ │ - @ instruction: 0xf8d7f8e2 │ │ │ │ - blmi fe4c9220 <__bss_end__@@Base+0xfe4225e8> │ │ │ │ + @ instruction: 0xf8d7fcd6 │ │ │ │ + blmi fe4c91a8 <__bss_end__@@Base+0xfe422608> │ │ │ │ @ instruction: 0xf10846a6 │ │ │ │ smladcs r0, r0, ip, r0 │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ ldm lr!, {r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ stmia ip!, {r0, r1, r2, r3} │ │ │ │ ldm lr, {r0, r1, r2, r3} │ │ │ │ stm ip, {r0, r1, r2, r3} │ │ │ │ stc 0, cr0, [r8, #60] @ 0x3c │ │ │ │ ldrt r7, [sp], -r2, lsl #22 │ │ │ │ @ instruction: 0xf7fea829 │ │ │ │ stmdacs r0, {r0, r3, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ mcrge 4, 2, pc, cr2, cr15, {3} @ │ │ │ │ ldrbtmi r4, [fp], #-2950 @ 0xfffff47a │ │ │ │ - blcs 429e4 │ │ │ │ + blcs 4296c │ │ │ │ mvnhi pc, #64 @ 0x40 │ │ │ │ - bvs 1903008 <__bss_end__@@Base+0x185c3d0> │ │ │ │ + bvs 1902f90 <__bss_end__@@Base+0x185c3f0> │ │ │ │ @ instruction: 0xf0402a01 │ │ │ │ ldmdavs r9, {r1, r2, r3, r6, r7, sl, pc} │ │ │ │ andeq pc, ip, #805306372 @ 0x30000004 │ │ │ │ @ instruction: 0xf0404291 │ │ │ │ ldmdavs sl, {r3, r6, r7, sl, pc}^ │ │ │ │ ldmvs r9, {r0, r2, r3, r6, r8, r9, sl, fp, sp, pc} │ │ │ │ @ instruction: 0xf5b24638 │ │ │ │ svclt 0x00345ffa │ │ │ │ vtst.8 q8, q8, q1 │ │ │ │ ldrmi r3, [r0], r7, ror #5 │ │ │ │ - bl fe4e6814 <__bss_end__@@Base+0xfe43fbdc> │ │ │ │ + bl fe9e679c <__bss_end__@@Base+0xfe93fbfc> │ │ │ │ ldrtmi r2, [sl], -r0, lsl #6 │ │ │ │ @ instruction: 0xf807213f │ │ │ │ ldmdavc fp!, {r3, ip, sp} │ │ │ │ - blcc 854da8 <__bss_end__@@Base+0x7ae170> │ │ │ │ + blcc 854d30 <__bss_end__@@Base+0x7ae190> │ │ │ │ svclt 0x00882b5e │ │ │ │ @ instruction: 0xf8127011 │ │ │ │ - blcs 384cc │ │ │ │ + blcs 38454 │ │ │ │ ldmdami r1!, {r0, r1, r2, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ ldrbtmi r4, [r8], #-1593 @ 0xfffff9c7 │ │ │ │ - ldcl 7, cr15, [lr], #872 @ 0x368 │ │ │ │ + ldc 7, cr15, [r6, #-872] @ 0xfffffc98 │ │ │ │ strcc r2, [r1], -r0, lsl #14 │ │ │ │ @ instruction: 0xf10de60c │ │ │ │ strbmi r0, [r0], -r4, lsr #17 │ │ │ │ stc2l 7, cr15, [ip], {254} @ 0xfe │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ svcmi 0x006aae05 │ │ │ │ - ldrbtmi r3, [pc], #-1537 @ 288f0 │ │ │ │ - blcs 42ae0 │ │ │ │ + ldrbtmi r3, [pc], #-1537 @ 28878 │ │ │ │ + blcs 42a68 │ │ │ │ @ instruction: 0x83b3f040 │ │ │ │ - blcs 42de8 │ │ │ │ - blmi 19dcac4 <__bss_end__@@Base+0x1935e8c> │ │ │ │ + blcs 42d70 │ │ │ │ + blmi 19dca4c <__bss_end__@@Base+0x1935eac> │ │ │ │ ldmdbeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ muleq r7, r4, r8 │ │ │ │ stm r9, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - ldc 0, cr0, [pc, #28] @ 2892c │ │ │ │ - bvs fe7ef618 <__bss_end__@@Base+0xfe7489e0> │ │ │ │ - bleq 1e3f64 <__bss_end__@@Base+0x13d32c> │ │ │ │ + ldc 0, cr0, [pc, #28] @ 288b4 │ │ │ │ + bvs fe7ef5a0 <__bss_end__@@Base+0xfe748a00> │ │ │ │ + bleq 1e3eec <__bss_end__@@Base+0x13d34c> │ │ │ │ @ instruction: 0xf889230f │ │ │ │ @ instruction: 0xf7da3002 │ │ │ │ - ldc 14, cr14, [pc, #376] @ 28a9c │ │ │ │ + ldc 14, cr14, [pc, #416] @ 28a4c │ │ │ │ @ instruction: 0xf06f7b3e │ │ │ │ cdp 2, 2, cr4, cr0, cr0, {0} │ │ │ │ vmov.f64 d16, #199 @ 0xbe380000 -0.1796875 │ │ │ │ vnmla.f64 d7, d23, d0 │ │ │ │ addsmi r3, r3, #144, 20 @ 0x90000 │ │ │ │ ldrmi fp, [r3], -r8, lsr #30 │ │ │ │ @ instruction: 0xf043b10f │ │ │ │ @@ -38080,46 +38075,46 @@ │ │ │ │ ldmhi sl!, {r0, r1, r2, r3, r4, r5, r6, r7, fp, ip, sp, lr} │ │ │ │ @ instruction: 0xf8cd4541 │ │ │ │ @ instruction: 0xf8ad004a │ │ │ │ @ instruction: 0xf8c92048 │ │ │ │ @ instruction: 0xf04f301c │ │ │ │ @ instruction: 0xf8c91304 │ │ │ │ @ instruction: 0xf0003018 │ │ │ │ - bmi 12098dc <__bss_end__@@Base+0x1162ca4> │ │ │ │ + bmi 1209864 <__bss_end__@@Base+0x1162cc4> │ │ │ │ ldmvs r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf0004299 │ │ │ │ @ instruction: 0xf10d84a8 │ │ │ │ stmdage ip!, {r5, fp} │ │ │ │ @ instruction: 0xf7e44641 │ │ │ │ - ldmib sp, {r0, r1, r4, r5, r6, r9, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmib sp, {r0, r1, r2, r5, r6, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf020010a │ │ │ │ - ldc 14, cr15, [pc, #436] @ 28b54 │ │ │ │ + ldc 14, cr15, [pc, #436] @ 28adc │ │ │ │ mcrr 11, 2, r7, r1, cr5 │ │ │ │ ldmib sp, {r1, r2, r4, r8, r9, fp}^ │ │ │ │ cdp 1, 8, cr0, cr6, cr8, {0} │ │ │ │ @ instruction: 0xf0208b07 │ │ │ │ mcrr 14, 6, pc, r1, cr3 @ │ │ │ │ vmov.32 r0, d8[1] │ │ │ │ ldrtmi r8, [r8], -r7, lsl #22 │ │ │ │ stc2 7, cr15, [r4], #-1016 @ 0xfffffc08 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ @ instruction: 0xf8a984fa │ │ │ │ @ instruction: 0xf8a90010 │ │ │ │ - blmi d28a38 <__bss_end__@@Base+0xc81e00> │ │ │ │ + blmi d289c0 <__bss_end__@@Base+0xc81e20> │ │ │ │ ldrbtmi r4, [fp], #-1609 @ 0xfffff9b7 │ │ │ │ @ instruction: 0xf7e56918 │ │ │ │ - strmi pc, [r7], -sp, lsr #21 │ │ │ │ + strmi pc, [r7], -r1, lsr #29 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0xf04fad7f │ │ │ │ str r3, [r5, #2047] @ 0x7ff │ │ │ │ @ instruction: 0xf7fea829 │ │ │ │ stmdacs r0, {r0, r1, r2, r6, sl, fp, ip, sp, lr, pc} │ │ │ │ stcge 4, cr15, [r0, #508] @ 0x1fc │ │ │ │ ldrbtmi r4, [fp], #-2859 @ 0xfffff4d5 │ │ │ │ - blcs 42b68 │ │ │ │ + blcs 42af0 │ │ │ │ tstphi r2, #64 @ p-variant is OBSOLETE @ 0x40 │ │ │ │ stmibvs r2!, {r0, r3, r5, r8, r9, fp, lr}^ │ │ │ │ svcvs 0x0059447b │ │ │ │ rsbsle r2, r6, r0, lsl #18 │ │ │ │ sub r4, pc, r8, lsl #12 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ @@ -38128,82 +38123,82 @@ │ │ │ │ @ instruction: 0x41223456 │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00c99999 │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00e99999 │ │ │ │ andeq r0, r0, r0 │ │ │ │ smlawbmi lr, r0, r4, r8 │ │ │ │ - andeq pc, r2, lr, lsr fp @ │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r5, r3, ip, asr r0 │ │ │ │ - andeq pc, r2, ip, lsr #22 │ │ │ │ - andeq r4, r3, ip, ror #31 │ │ │ │ - ldrdeq r4, [r3], -sl │ │ │ │ - andeq r4, r3, sl, asr #31 │ │ │ │ - andeq r4, r3, lr, lsr #31 │ │ │ │ - andeq r2, r2, ip, lsl r8 │ │ │ │ - andeq r4, r3, r0, lsl #31 │ │ │ │ - andeq r4, r3, r2, lsr #29 │ │ │ │ - andeq pc, r2, ip, ror #18 │ │ │ │ - andeq r4, r3, r0, asr #28 │ │ │ │ - andeq r4, r3, ip, asr #27 │ │ │ │ + @ instruction: 0x0002fbb6 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r5, r3, ip, lsr r0 │ │ │ │ + andeq pc, r2, r4, lsr #23 │ │ │ │ + andeq r4, r3, ip, asr #31 │ │ │ │ + @ instruction: 0x00034fba │ │ │ │ + andeq r4, r3, sl, lsr #31 │ │ │ │ + andeq r4, r3, lr, lsl #31 │ │ │ │ + andeq r2, r2, r8, asr sl │ │ │ │ + andeq r4, r3, r0, ror #30 │ │ │ │ + andeq r4, r3, r2, lsl #29 │ │ │ │ + andeq pc, r2, r4, ror #19 │ │ │ │ + andeq r4, r3, r0, lsr #28 │ │ │ │ andeq r4, r3, ip, lsr #27 │ │ │ │ - andeq r0, r0, r0, lsr #6 │ │ │ │ - andeq r2, r2, r0, asr #11 │ │ │ │ - andeq r4, r3, r8, lsr #26 │ │ │ │ - andeq r4, r3, ip, lsl #26 │ │ │ │ - andeq r4, r3, r0, ror #25 │ │ │ │ - @ instruction: 0x00034cb6 │ │ │ │ - andeq r2, r2, r6, ror r4 │ │ │ │ - andeq r4, r3, sl, lsr ip │ │ │ │ - andeq r4, r3, r0, lsr #24 │ │ │ │ - andeq r4, r3, r8, lsr #23 │ │ │ │ - andeq r4, r3, r6, asr fp │ │ │ │ - andeq r4, r3, r2, lsr fp │ │ │ │ - andeq r4, r3, r4, lsr #22 │ │ │ │ + andeq r4, r3, ip, lsl #27 │ │ │ │ + andeq r0, r0, r8, lsl r3 │ │ │ │ + strdeq r2, [r2], -ip │ │ │ │ + andeq r4, r3, r8, lsl #26 │ │ │ │ + andeq r4, r3, ip, ror #25 │ │ │ │ + andeq r4, r3, r0, asr #25 │ │ │ │ + muleq r3, r6, ip │ │ │ │ + @ instruction: 0x000226b2 │ │ │ │ + andeq r4, r3, sl, lsl ip │ │ │ │ + andeq r4, r3, r0, lsl #24 │ │ │ │ + andeq r4, r3, r8, lsl #23 │ │ │ │ + andeq r4, r3, r6, lsr fp │ │ │ │ + andeq r4, r3, r2, lsl fp │ │ │ │ + andeq r4, r3, r4, lsl #22 │ │ │ │ @ instruction: 0xb3206980 │ │ │ │ addsmi r6, sl, #4390912 @ 0x430000 │ │ │ │ stmdavs r3, {r1, r3, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ stmibvs r3, {r0, r1, r3, r4, r5, r6, r7, r8, fp, ip, sp, pc}^ │ │ │ │ stmibvs sl, {r0, r1, r2, r7, fp, sp, lr} │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ orrsvs r8, sl, r0, lsl #8 │ │ │ │ stmibvs sl, {r0, r1, r7, r8, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ bicsvs r8, sl, r3, lsr #9 │ │ │ │ - @ instruction: 0xf83af7eb │ │ │ │ - blcs 94b768 <__bss_end__@@Base+0x8a4b30> │ │ │ │ - blhi 189cf14 <__bss_end__@@Base+0x17f62dc> │ │ │ │ + @ instruction: 0xf8e2f7eb │ │ │ │ + blcs 94b6f0 <__bss_end__@@Base+0x8a4b50> │ │ │ │ + blhi 189ce9c <__bss_end__@@Base+0x17f62fc> │ │ │ │ @ instruction: 0xf0002901 │ │ │ │ stmdbcs r5, {r0, r3, r5, r7, sl, pc} │ │ │ │ ldrhi pc, [fp], #0 │ │ │ │ ldrbtmi r4, [r8], #-2283 @ 0xfffff715 │ │ │ │ - bl ffbe6a5c <__bss_end__@@Base+0xffb3fe24> │ │ │ │ + stc 7, cr15, [r6], {218} @ 0xda │ │ │ │ stmib r7, {r8, r9, sp}^ │ │ │ │ strcc r3, [r1], -r0, ror #7 │ │ │ │ - strbt r2, [pc], #1792 @ 28b00 │ │ │ │ + strbt r2, [pc], #1792 @ 28a88 │ │ │ │ stmiaeq r4!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe4640 │ │ │ │ stmdacs r0, {r0, r3, r4, r5, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ ldclge 4, cr15, [r2], #508 @ 0x1fc │ │ │ │ strcc r4, [r1], -r3, ror #31 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ ldmdbvs fp!, {r0, r1, r2, r4, r5, r6, r9, pc} │ │ │ │ @ instruction: 0xf43f2b00 │ │ │ │ - blmi ff8148a0 <__bss_end__@@Base+0xff76dc68> │ │ │ │ + blmi ff814828 <__bss_end__@@Base+0xff76dc88> │ │ │ │ ldmdbeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ muleq r7, r4, r8 │ │ │ │ stm r9, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - ldc 0, cr0, [pc, #28] @ 28b54 │ │ │ │ - bvs fe7efa80 <__bss_end__@@Base+0xfe748e48> │ │ │ │ - bleq 1e418c <__bss_end__@@Base+0x13d554> │ │ │ │ + ldc 0, cr0, [pc, #28] @ 28adc │ │ │ │ + bvs fe7efa08 <__bss_end__@@Base+0xfe748e68> │ │ │ │ + bleq 1e4114 <__bss_end__@@Base+0x13d574> │ │ │ │ @ instruction: 0xf889230f │ │ │ │ @ instruction: 0xf7da3002 │ │ │ │ - ldc 13, cr14, [pc, #296] @ 28c74 │ │ │ │ + ldc 13, cr14, [pc, #336] @ 28c24 │ │ │ │ @ instruction: 0xf06f7bce │ │ │ │ cdp 2, 2, cr4, cr0, cr0, {0} │ │ │ │ vmov.f64 d16, #199 @ 0xbe380000 -0.1796875 │ │ │ │ vnmla.f64 d7, d23, d0 │ │ │ │ addsmi r3, r3, #144, 20 @ 0x90000 │ │ │ │ ldrmi fp, [r3], -r8, lsr #30 │ │ │ │ @ instruction: 0xf043b10f │ │ │ │ @@ -38218,60 +38213,60 @@ │ │ │ │ ldmhi sl!, {r0, r1, r2, r3, r4, r5, r6, r7, fp, ip, sp, lr} │ │ │ │ @ instruction: 0xf8cd4541 │ │ │ │ @ instruction: 0xf8ad004a │ │ │ │ @ instruction: 0xf8c92048 │ │ │ │ @ instruction: 0xf04f301c │ │ │ │ @ instruction: 0xf8c91304 │ │ │ │ @ instruction: 0xf0003018 │ │ │ │ - bmi ff0495a0 <__bss_end__@@Base+0xfefa2968> │ │ │ │ + bmi ff049528 <__bss_end__@@Base+0xfefa2988> │ │ │ │ ldmvs r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf0004299 │ │ │ │ @ instruction: 0xf10d83bc │ │ │ │ stmdage ip!, {r5, fp} │ │ │ │ @ instruction: 0xf7e44641 │ │ │ │ - ldmib sp, {r0, r1, r2, r3, r4, r6, r8, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmib sp, {r0, r1, r4, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf020010a │ │ │ │ - ldc 13, cr15, [pc, #356] @ 28d2c │ │ │ │ + ldc 13, cr15, [pc, #356] @ 28cb4 │ │ │ │ mcrr 11, 11, r7, r1, cr1 │ │ │ │ ldmib sp, {r1, r2, r4, r8, r9, fp}^ │ │ │ │ cdp 1, 8, cr0, cr6, cr8, {0} │ │ │ │ @ instruction: 0xf0208b07 │ │ │ │ mcrr 13, 4, pc, r1, cr15 @ │ │ │ │ vmov.32 r0, d8[1] │ │ │ │ ldrtmi r8, [r8], -r7, lsl #22 │ │ │ │ - blx 466be2 <__bss_end__@@Base+0x3bffaa> │ │ │ │ + blx 466b6a <__bss_end__@@Base+0x3bffca> │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ @ instruction: 0xf8a983c5 │ │ │ │ @ instruction: 0xf8a90010 │ │ │ │ - blmi feb68c60 <__bss_end__@@Base+0xfeac2028> │ │ │ │ + blmi feb68be8 <__bss_end__@@Base+0xfeac2048> │ │ │ │ ldrbtmi r4, [fp], #-1609 @ 0xfffff9b7 │ │ │ │ @ instruction: 0xf10de056 │ │ │ │ strbmi r0, [r0], -r4, lsr #17 │ │ │ │ - blx ee6c02 <__bss_end__@@Base+0xe3ffca> │ │ │ │ + blx ee6b8a <__bss_end__@@Base+0xe3ffea> │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ - blmi fea53ddc <__bss_end__@@Base+0xfe9ad1a4> │ │ │ │ + blmi fea53d64 <__bss_end__@@Base+0xfe9ad1c4> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ - blmi fe9c9440 <__bss_end__@@Base+0xfe922808> │ │ │ │ + blmi fe9c93c8 <__bss_end__@@Base+0xfe922828> │ │ │ │ ldrbtmi r3, [fp], #-1537 @ 0xfffff9ff │ │ │ │ - bcs 4308c │ │ │ │ + bcs 43014 │ │ │ │ mrcge 4, 6, APSR_nzcv, cr13, cr15, {1} │ │ │ │ ldmdbeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ ldm r4, {r0, r1, r2, r3, r4, r7, r9, fp, sp, lr} │ │ │ │ stm r9, {r0, r1, r2} │ │ │ │ ldc 0, cr0, [r3, #28] │ │ │ │ - vldr d0, [pc, #24] @ 28c54 │ │ │ │ + vldr d0, [pc, #24] @ 28bdc │ │ │ │ tstcs r4, #144, 22 @ 0x24000 │ │ │ │ andcc pc, r2, r9, lsl #17 │ │ │ │ - stcl 7, cr15, [sl], {218} @ 0xda │ │ │ │ - blvc fe3e42c8 <__bss_end__@@Base+0xfe33d690> │ │ │ │ + ldcl 7, cr15, [r4], {218} @ 0xda │ │ │ │ + blvc fe3e4250 <__bss_end__@@Base+0xfe33d6b0> │ │ │ │ andmi pc, r0, #111 @ 0x6f │ │ │ │ - bleq 2244d4 <__bss_end__@@Base+0x17d89c> │ │ │ │ - blvc ff064848 <__bss_end__@@Base+0xfefbdc10> │ │ │ │ - bcc fe4644b8 <__bss_end__@@Base+0xfe3bd880> │ │ │ │ + bleq 22445c <__bss_end__@@Base+0x17d8bc> │ │ │ │ + blvc ff0647d0 <__bss_end__@@Base+0xfefbdc30> │ │ │ │ + bcc fe464440 <__bss_end__@@Base+0xfe3bd8a0> │ │ │ │ svclt 0x00284293 │ │ │ │ svccs 0x00004613 │ │ │ │ @ instruction: 0x81b2f040 │ │ │ │ andcc pc, r4, r9, asr #17 │ │ │ │ streq pc, [sl, sp, lsl #2]! │ │ │ │ @ instruction: 0x3004f8b8 │ │ │ │ ldrdeq pc, [sl], sp @ │ │ │ │ @@ -38279,58 +38274,58 @@ │ │ │ │ @ instruction: 0xf8bd9011 │ │ │ │ @ instruction: 0xf8d820ae │ │ │ │ stmibvs r3!, {} @ │ │ │ │ subeq pc, sl, sp, asr #17 │ │ │ │ @ instruction: 0xf8ada815 │ │ │ │ @ instruction: 0xf8c92048 │ │ │ │ @ instruction: 0xf7e53018 │ │ │ │ - ldrtmi pc, [r8], -sl, ror #19 @ │ │ │ │ - blx fed66c98 <__bss_end__@@Base+0xfecc0060> │ │ │ │ + @ instruction: 0x4638fdde │ │ │ │ + blx fed66c20 <__bss_end__@@Base+0xfecc0080> │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ - blmi fe154720 <__bss_end__@@Base+0xfe0adae8> │ │ │ │ + blmi fe1546a8 <__bss_end__@@Base+0xfe0adb08> │ │ │ │ ldrbtmi r4, [fp], #-1609 @ 0xfffff9b7 │ │ │ │ @ instruction: 0xf7e56918 │ │ │ │ - stmdacc r0, {r0, r6, r8, fp, ip, sp, lr, pc} │ │ │ │ + stmdacc r0, {r0, r2, r4, r5, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ stmdacs r0, {r0, r1, r2, r6, r9, lr} │ │ │ │ ldcge 4, cr15, [r0], {63} @ 0x3f │ │ │ │ @ instruction: 0xf10de418 │ │ │ │ strbmi r0, [r0], -r4, lsr #17 │ │ │ │ - blx ff666cc4 <__bss_end__@@Base+0xff5c008c> │ │ │ │ + blx ff666c4c <__bss_end__@@Base+0xff5c00ac> │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ - blmi 1ed3d18 <__bss_end__@@Base+0x1e2d0e0> │ │ │ │ + blmi 1ed3ca0 <__bss_end__@@Base+0x1e2d100> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ - blmi 1e4932c <__bss_end__@@Base+0x1da26f4> │ │ │ │ + blmi 1e492b4 <__bss_end__@@Base+0x1da2714> │ │ │ │ mrcvc 4, 0, r4, cr10, cr11, {3} │ │ │ │ suble r2, sp, r0, lsl #20 │ │ │ │ strhne pc, [r0], #-132 @ 0xffffff7c @ │ │ │ │ @ instruction: 0xf8b43318 │ │ │ │ @ instruction: 0xf8b40042 │ │ │ │ and r7, r3, r4, asr #32 │ │ │ │ svccs 0x0008f813 │ │ │ │ suble r2, r1, r0, lsl #20 │ │ │ │ addmi r8, sl, #1703936 @ 0x1a0000 │ │ │ │ ldmdahi sl, {r3, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ mvnsle r4, r2, lsl #5 │ │ │ │ adcsmi r8, sl, #10092544 @ 0x9a0000 │ │ │ │ @ instruction: 0x4640d1f2 │ │ │ │ - blx 1e66d10 <__bss_end__@@Base+0x1dc00d8> │ │ │ │ + blx 1e66c98 <__bss_end__@@Base+0x1dc00f8> │ │ │ │ stmdacs r0, {r0, r1, r7, r9, sl, lr} │ │ │ │ msrhi SPSR_fxc, #64 @ 0x40 │ │ │ │ - bmi 564374 <__bss_end__@@Base+0x4bd73c> │ │ │ │ + bmi 5642fc <__bss_end__@@Base+0x4bd75c> │ │ │ │ stcleq 1, cr15, [r0], {13} │ │ │ │ - bpl 5a437c <__bss_end__@@Base+0x4fd744> │ │ │ │ + bpl 5a4304 <__bss_end__@@Base+0x4fd764> │ │ │ │ cdpeq 1, 2, cr15, cr0, cr13, {0} │ │ │ │ - bvs 5e4384 <__bss_end__@@Base+0x53d74c> │ │ │ │ + bvs 5e430c <__bss_end__@@Base+0x53d76c> │ │ │ │ mrc 6, 5, r4, cr7, cr7, {3} │ │ │ │ - vldr s8, [pc, #784] @ 2904c │ │ │ │ + vldr s8, [pc, #784] @ 28fd4 │ │ │ │ @ instruction: 0xeeb77b56 │ │ │ │ - blmi 183f858 <__bss_end__@@Base+0x1798c20> │ │ │ │ - bvs ff1e4824 <__bss_end__@@Base+0xff13dbec> │ │ │ │ + blmi 183f7e0 <__bss_end__@@Base+0x1798c40> │ │ │ │ + bvs ff1e47ac <__bss_end__@@Base+0xff13dc0c> │ │ │ │ ldmdbeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ mcr 4, 4, r4, cr4, cr11, {3} │ │ │ │ vdiv.f64 d3, d5, d7 │ │ │ │ @ instruction: 0xf8d34b07 │ │ │ │ cdp 0, 8, cr8, cr6, cr4, {2} │ │ │ │ ldm ip!, {r0, r1, r2, r8, r9, fp, ip, lr} │ │ │ │ strgt r0, [pc, -pc] │ │ │ │ @@ -38339,169 +38334,169 @@ │ │ │ │ stm r7, {r0, r1} │ │ │ │ ldrbtmi r0, [r1], -r3 │ │ │ │ stc 6, cr4, [sp, #352] @ 0x160 │ │ │ │ vstr d3, [sp, #56] @ 0x38 │ │ │ │ vstr d4, [sp, #64] @ 0x40 │ │ │ │ bfimi r5, r2, (invalid: 22:0) │ │ │ │ strcs r3, [r0, -r1, lsl #12] │ │ │ │ - bllt fed66d88 <__bss_end__@@Base+0xfecc0150> │ │ │ │ + bllt fed66d10 <__bss_end__@@Base+0xfecc0170> │ │ │ │ stmiaeq r4!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe4640 │ │ │ │ stmdacs r0, {r0, r1, r4, r5, r6, r9, fp, ip, sp, lr, pc} │ │ │ │ - blge feb65f98 <__bss_end__@@Base+0xfeabf360> │ │ │ │ + blge feb65f20 <__bss_end__@@Base+0xfeabf380> │ │ │ │ ldrbtmi r4, [fp], #-2890 @ 0xfffff4b6 │ │ │ │ - blcs 42f10 │ │ │ │ + blcs 42e98 │ │ │ │ msrhi CPSR_fx, r0, asr #32 │ │ │ │ - ldrbtmi r4, [pc], #-3912 @ 28dac │ │ │ │ - blcs 43e9c │ │ │ │ + ldrbtmi r4, [pc], #-3912 @ 28d34 │ │ │ │ + blcs 43e24 │ │ │ │ rsbshi pc, pc, #0 │ │ │ │ @ instruction: 0xf7fe4640 │ │ │ │ strmi pc, [r1], -r7, lsr #20 │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ ldmdavs r8!, {r4, r5, r9, pc} │ │ │ │ ldc2 7, cr15, [r4], #-944 @ 0xfffffc50 │ │ │ │ stmdacs r0, {r7, r9, sl, lr} │ │ │ │ eorhi pc, r9, #0 │ │ │ │ adceq pc, sl, sp, lsl #2 │ │ │ │ - blx 666dd0 <__bss_end__@@Base+0x5c0198> │ │ │ │ + blx 666d58 <__bss_end__@@Base+0x5c01b8> │ │ │ │ stmdacs r0, {r0, r9, sl, lr} │ │ │ │ subshi pc, r4, #0 │ │ │ │ @ instruction: 0xf7ec6838 │ │ │ │ strmi pc, [r3], -r5, lsr #24 │ │ │ │ stmdacs r0, {r1, r2, ip, pc} │ │ │ │ subhi pc, ip, #0 │ │ │ │ - bvc 664444 <__bss_end__@@Base+0x5bd80c> │ │ │ │ + bvc 6643cc <__bss_end__@@Base+0x5bd82c> │ │ │ │ stmibeq r0, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ - bleq 1a65230 <__bss_end__@@Base+0x19be5f8> │ │ │ │ - bpl 5e4450 <__bss_end__@@Base+0x53d818> │ │ │ │ - bvs 624454 <__bss_end__@@Base+0x57d81c> │ │ │ │ + bleq 1a651b8 <__bss_end__@@Base+0x19be618> │ │ │ │ + bpl 5e43d8 <__bss_end__@@Base+0x53d838> │ │ │ │ + bvs 6243dc <__bss_end__@@Base+0x57d83c> │ │ │ │ cdp 8, 11, cr10, cr7, cr12, {1} │ │ │ │ @ instruction: 0xf8947ac7 │ │ │ │ cdp 0, 11, cr1, cr7, cr12, {2} │ │ │ │ vldr s10, [r7, #788] @ 0x314 │ │ │ │ vmov.f64 d8, #118 @ 0x3fb00000 1.375 │ │ │ │ stmdbcs r2, {r1, r2, r6, r7, r9, fp, sp, lr} │ │ │ │ movwcs fp, #12052 @ 0x2f14 │ │ │ │ stc 3, cr2, [r9, #4] │ │ │ │ vldr d7, [r4, #16] │ │ │ │ movwls r7, #23308 @ 0x5b0c │ │ │ │ - blpl 64454 <__bss_start@@Base+0x93b4> │ │ │ │ - blvc 64460 <__bss_start@@Base+0x93c0> │ │ │ │ - blvc 3e4488 <__bss_end__@@Base+0x33d850> │ │ │ │ - blvs e4460 <__bss_end__@@Base+0x3d828> │ │ │ │ - blvc e446c <__bss_end__@@Base+0x3d834> │ │ │ │ - blvc 464494 <__bss_end__@@Base+0x3bd85c> │ │ │ │ - blvc 164474 <__bss_end__@@Base+0xbd83c> │ │ │ │ + blpl 643dc <__bss_start@@Base+0x93d4> │ │ │ │ + blvc 643e8 <__bss_start@@Base+0x93e0> │ │ │ │ + blvc 3e4410 <__bss_end__@@Base+0x33d870> │ │ │ │ + blvs e43e8 <__bss_end__@@Base+0x3d848> │ │ │ │ + blvc e43f4 <__bss_end__@@Base+0x3d854> │ │ │ │ + blvc 46441c <__bss_end__@@Base+0x3bd87c> │ │ │ │ + blvc 1643fc <__bss_end__@@Base+0xbd85c> │ │ │ │ @ instruction: 0xf9def7fe │ │ │ │ stmdacs r0, {r0, r9, sl, lr} │ │ │ │ mvnhi pc, r0, asr #32 │ │ │ │ - blls 1b2a58 <__bss_end__@@Base+0x10be20> │ │ │ │ - bleq 126491c <__bss_end__@@Base+0x11bdce4> │ │ │ │ + blls 1b29e0 <__bss_end__@@Base+0x10be40> │ │ │ │ + bleq 12648a4 <__bss_end__@@Base+0x11bdd04> │ │ │ │ @ instruction: 0x101cf8d8 │ │ │ │ @ instruction: 0x465b69d8 │ │ │ │ strls lr, [r0, -sp, asr #19] │ │ │ │ @ instruction: 0x46024f19 │ │ │ │ - ldrbtmi r9, [pc], #-1026 @ 28e70 │ │ │ │ - ldcvs 8, cr9, [pc], #-20 @ 28e60 │ │ │ │ + ldrbtmi r9, [pc], #-1026 @ 28df8 │ │ │ │ + ldcvs 8, cr9, [pc], #-20 @ 28de8 │ │ │ │ str r4, [sp, #-1976]! @ 0xfffff848 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ ldmvc sl, {r0, r3, r6, r7, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0x41223456 │ │ │ │ andeq r0, r0, r0 │ │ │ │ smlawbmi lr, r0, r4, r8 │ │ │ │ - bvs fe0af858 <__bss_end__@@Base+0xfe008c20> │ │ │ │ + bvs fe0af7e0 <__bss_end__@@Base+0xfe008c40> │ │ │ │ svccc 0x00d381da │ │ │ │ - andeq r2, r2, lr, lsl r2 │ │ │ │ - andeq r4, r3, r4, lsl sl │ │ │ │ + andeq r2, r2, sl, asr r4 │ │ │ │ + strdeq r4, [r3], -r4 @ │ │ │ │ + ldrdeq r4, [r3], -r8 │ │ │ │ + andeq r4, r3, r0, ror #18 │ │ │ │ + andeq r4, r3, lr, lsl #18 │ │ │ │ strdeq r4, [r3], -r8 │ │ │ │ - andeq r4, r3, r0, lsl #19 │ │ │ │ - andeq r4, r3, lr, lsr #18 │ │ │ │ - andeq r4, r3, r8, lsl r9 │ │ │ │ - andeq r4, r3, sl, lsl #18 │ │ │ │ - andeq r4, r3, lr, ror r8 │ │ │ │ - andeq r4, r3, r4, asr r8 │ │ │ │ - andeq r1, r3, r8, lsr #21 │ │ │ │ - ldrdeq r4, [r3], -ip │ │ │ │ - andeq r4, r3, sl, lsl #15 │ │ │ │ - andeq r4, r3, lr, ror r7 │ │ │ │ - @ instruction: 0x000346ba │ │ │ │ + andeq r4, r3, sl, ror #17 │ │ │ │ + andeq r4, r3, lr, asr r8 │ │ │ │ + andeq r4, r3, r4, lsr r8 │ │ │ │ + andeq r1, r3, r8, lsl #21 │ │ │ │ + @ instruction: 0x000347bc │ │ │ │ + andeq r4, r3, sl, ror #14 │ │ │ │ + andeq r4, r3, lr, asr r7 │ │ │ │ + muleq r3, sl, r6 │ │ │ │ stmiaeq r4!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe4640 │ │ │ │ stmdacs r0, {r0, r1, r2, r3, r6, r7, r8, fp, ip, sp, lr, pc} │ │ │ │ - blge 2660e0 <__bss_end__@@Base+0x1bf4a8> │ │ │ │ + blge 266068 <__bss_end__@@Base+0x1bf4c8> │ │ │ │ ldrbtmi r4, [fp], #-3035 @ 0xfffff425 │ │ │ │ - blcs 43058 │ │ │ │ + blcs 42fe0 │ │ │ │ addhi pc, r2, r0, asr #32 │ │ │ │ @ instruction: 0xf7fe4640 │ │ │ │ @ instruction: 0x6d63f989 │ │ │ │ @ instruction: 0xf0134601 │ │ │ │ cmnle r8, r8, lsl pc │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ - blmi ff54969c <__bss_end__@@Base+0xff4a2a64> │ │ │ │ + blmi ff549624 <__bss_end__@@Base+0xff4a2a84> │ │ │ │ ldmdbeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ andeq pc, r0, r9, asr #17 │ │ │ │ movwls r4, #21627 @ 0x547b │ │ │ │ @ instruction: 0xf7ec6818 │ │ │ │ @ instruction: 0x4607fb9a │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ - blls 189600 <__bss_end__@@Base+0xe29c8> │ │ │ │ + blls 189588 <__bss_end__@@Base+0xe29e8> │ │ │ │ ldmdavs r8, {r0, r3, r4, r5, r9, sl, lr} │ │ │ │ - blx fe0e6ede <__bss_end__@@Base+0xfe0402a6> │ │ │ │ + blx fe0e6e66 <__bss_end__@@Base+0xfe0402c6> │ │ │ │ vst1.32 {d20-d22}, [pc], r3 │ │ │ │ tstcs r0, r2, ror #4 │ │ │ │ @ instruction: 0xf7da4658 │ │ │ │ - blmi ff2631dc <__bss_end__@@Base+0xff1bc5a4> │ │ │ │ + blmi ff2631bc <__bss_end__@@Base+0xff1bc61c> │ │ │ │ ldrdeq pc, [r0], -r8 │ │ │ │ ldrbtmi r2, [fp], #-257 @ 0xfffffeff │ │ │ │ eorseq pc, r0, #-1073741822 @ 0xc0000002 │ │ │ │ eoreq pc, sl, fp, asr #17 │ │ │ │ - bleq fefa45cc <__bss_end__@@Base+0xfeefd994> │ │ │ │ - blcs 1645a0 <__bss_end__@@Base+0xbd968> │ │ │ │ - blne e45a4 <__bss_end__@@Base+0x3d96c> │ │ │ │ + bleq fefa4554 <__bss_end__@@Base+0xfeefd9b4> │ │ │ │ + blcs 164528 <__bss_end__@@Base+0xbd988> │ │ │ │ + blne e452c <__bss_end__@@Base+0x3d98c> │ │ │ │ stmib fp, {r0, r1, r8, r9, sp}^ │ │ │ │ @ instruction: 0xf8b81301 │ │ │ │ @ instruction: 0xf10d3004 │ │ │ │ stcvc 8, cr0, [r1], #688 @ 0x2b0 │ │ │ │ eorne pc, r8, fp, lsl #17 │ │ │ │ muleq r3, r8, r8 │ │ │ │ eorcc pc, lr, fp, lsr #17 │ │ │ │ andeq lr, r3, r2, lsl #17 │ │ │ │ @ instruction: 0xf10baa2d │ │ │ │ ldm r2, {r3, r4, r5, r8, r9} │ │ │ │ stm r3, {r0, r1} │ │ │ │ @ instruction: 0xf10b0003 │ │ │ │ @ instruction: 0xf7e40040 │ │ │ │ - strtmi pc, [r1], -r8, lsl #24 │ │ │ │ + qsub8mi pc, r1, ip @ │ │ │ │ @ instruction: 0xf7fe4638 │ │ │ │ - blmi fece7744 <__bss_end__@@Base+0xfec40b0c> │ │ │ │ + blmi fece76cc <__bss_end__@@Base+0xfec40b2c> │ │ │ │ stcvc 6, cr4, [r2], #260 @ 0x104 │ │ │ │ @ instruction: 0x4638447b │ │ │ │ ldrsbthi pc, [ip], -r3 @ │ │ │ │ strbmi r4, [r0, fp, asr #12] │ │ │ │ ldrdcc pc, [r0], -r9 │ │ │ │ andscc pc, ip, fp, asr #17 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - blx fee09860 <__bss_end__@@Base+0xfed62c28> │ │ │ │ + blx fee097e8 <__bss_end__@@Base+0xfed62c48> │ │ │ │ ldmdbeq pc!, {r0, r1, r2, r7, r8, r9, sl, ip, sp, lr, pc}^ @ │ │ │ │ str r4, [sl], #639 @ 0x27f │ │ │ │ rscscc pc, pc, pc, asr #32 │ │ │ │ - blx 15e6fc0 <__bss_end__@@Base+0x1540388> │ │ │ │ - blt ff1e6fc8 <__bss_end__@@Base+0xff140390> │ │ │ │ + blx 15e6f48 <__bss_end__@@Base+0x15403a8> │ │ │ │ + blt ff1e6f50 <__bss_end__@@Base+0xff1403b0> │ │ │ │ movwvs pc, #67 @ 0x43 @ │ │ │ │ stmdacs r0, {r1, r3, r6, r9, sl, sp, lr, pc} │ │ │ │ ldclge 4, cr15, [lr], #-252 @ 0xffffff04 │ │ │ │ ldrbtmi r4, [fp], #-2978 @ 0xfffff45e │ │ │ │ @ instruction: 0xf7ec6818 │ │ │ │ stmibvs r0, {r0, r1, r2, r5, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf50049a0 │ │ │ │ ldrbtmi r5, [r9], #-896 @ 0xfffffc80 │ │ │ │ teqpcc ip, r3 @ @ p-variant is OBSOLETE │ │ │ │ - strbt r4, [pc], #-1944 @ 28ff4 │ │ │ │ + strbt r4, [pc], #-1944 @ 28f7c │ │ │ │ @ instruction: 0xf7fe89a0 │ │ │ │ @ instruction: 0xe779fa3d │ │ │ │ @ instruction: 0xf7fe89a0 │ │ │ │ @ instruction: 0xe6d1fa39 │ │ │ │ @ instruction: 0xf7fe89a0 │ │ │ │ @ instruction: 0xe668fa35 │ │ │ │ @ instruction: 0xf7fe89a0 │ │ │ │ @@ -38521,70 +38516,70 @@ │ │ │ │ @ instruction: 0xf43f2b00 │ │ │ │ strb sl, [sl], #2890 @ 0xb4a │ │ │ │ @ instruction: 0xf7fe89a0 │ │ │ │ ldr pc, [r3], #-2577 @ 0xfffff5ef │ │ │ │ @ instruction: 0xf7fe89a0 │ │ │ │ @ instruction: 0xf7fffa0d │ │ │ │ stmibhi r0!, {r1, r2, r4, r6, r7, r8, r9, fp, ip, sp, pc} │ │ │ │ - blx 26705c <__bss_end__@@Base+0x1c0424> │ │ │ │ - blcs 43554 │ │ │ │ + blx 266fe4 <__bss_end__@@Base+0x1c0444> │ │ │ │ + blcs 434dc │ │ │ │ ldcge 4, cr15, [fp], #252 @ 0xfc │ │ │ │ - blcs 4325c │ │ │ │ + blcs 431e4 │ │ │ │ mcrrge 4, 3, pc, r5, cr15 @ │ │ │ │ ldmdami sp!, {r0, r2, r4, r5, r7, sl, sp, lr, pc}^ │ │ │ │ eorscs r4, r8, #70254592 @ 0x4300000 │ │ │ │ bicsvc pc, sl, r0, asr #4 │ │ │ │ @ instruction: 0xf7ea4478 │ │ │ │ - @ instruction: 0x4641fcb3 │ │ │ │ + @ instruction: 0x4641fd5b │ │ │ │ @ instruction: 0xf8c72238 │ │ │ │ - @ instruction: 0xf7d90278 │ │ │ │ - @ instruction: 0xf8d7effc │ │ │ │ + @ instruction: 0xf7da0278 │ │ │ │ + @ instruction: 0xf8d7e812 │ │ │ │ @ instruction: 0xf04f8278 │ │ │ │ stmib r8, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, ip, sp}^ │ │ │ │ @ instruction: 0xf7ff3300 │ │ │ │ svcge 0x0008bbce │ │ │ │ ldrtmi sl, [r9], -ip, lsr #16 │ │ │ │ - cdp2 7, 14, cr15, cr8, cr3, {7} │ │ │ │ + blx ff766fc4 <__bss_end__@@Base+0xff6c0424> │ │ │ │ ldrdeq lr, [sl, -sp] │ │ │ │ - blx ff8e5134 <__bss_end__@@Base+0xff83e4fc> │ │ │ │ - blvc 19a4734 <__bss_end__@@Base+0x18fdafc> │ │ │ │ - bleq 5e41c0 <__bss_end__@@Base+0x53d588> │ │ │ │ + blx ff8e50bc <__bss_end__@@Base+0xff83e51c> │ │ │ │ + blvc 19a46bc <__bss_end__@@Base+0x18fdb1c> │ │ │ │ + bleq 5e4148 <__bss_end__@@Base+0x53d5a8> │ │ │ │ ldrdeq lr, [r8, -sp] │ │ │ │ - blhi 224adc <__bss_end__@@Base+0x17dea4> │ │ │ │ - blx ff665148 <__bss_end__@@Base+0xff5be510> │ │ │ │ - bleq 6241d0 <__bss_end__@@Base+0x57d598> │ │ │ │ - blhi 2249b0 <__bss_end__@@Base+0x17dd78> │ │ │ │ - ldrbtmi r4, [pc], #-3943 @ 290d4 │ │ │ │ + blhi 224a64 <__bss_end__@@Base+0x17dec4> │ │ │ │ + blx ff6650d0 <__bss_end__@@Base+0xff5be530> │ │ │ │ + bleq 624158 <__bss_end__@@Base+0x57d5b8> │ │ │ │ + blhi 224938 <__bss_end__@@Base+0x17dd98> │ │ │ │ + ldrbtmi r4, [pc], #-3943 @ 2905c │ │ │ │ @ instruction: 0xf7ec6838 │ │ │ │ strmi pc, [r1], -r7, lsl #25 │ │ │ │ @ instruction: 0xf04fb300 │ │ │ │ ldmdavs r8!, {r0, fp} │ │ │ │ - blx fe967098 <__bss_end__@@Base+0xfe8c0460> │ │ │ │ + blx fe967020 <__bss_end__@@Base+0xfe8c0480> │ │ │ │ orrslt r6, fp, r3, lsl #16 │ │ │ │ - blvc 1e474c <__bss_end__@@Base+0x13db14> │ │ │ │ - blvc ff264bc4 <__bss_end__@@Base+0xff1bdf8c> │ │ │ │ - blx 464cbc <__bss_end__@@Base+0x3be084> │ │ │ │ + blvc 1e46d4 <__bss_end__@@Base+0x13db34> │ │ │ │ + blvc ff264b4c <__bss_end__@@Base+0xff1bdfac> │ │ │ │ + blx 464c44 <__bss_end__@@Base+0x3be0a4> │ │ │ │ movwcs fp, #12196 @ 0x2fa4 │ │ │ │ - ble 10120c <__bss_end__@@Base+0x5a5d4> │ │ │ │ + ble 101194 <__bss_end__@@Base+0x5a5f4> │ │ │ │ addvs r2, r3, r2, lsl #6 │ │ │ │ - blhi 164708 <__bss_end__@@Base+0xbdad0> │ │ │ │ + blhi 164690 <__bss_end__@@Base+0xbdaf0> │ │ │ │ mlacc r1, r4, r8, pc @ │ │ │ │ svclt 0x0048079a │ │ │ │ andshi pc, r8, r0, asr #17 │ │ │ │ @ instruction: 0xf7ec6838 │ │ │ │ strmi pc, [r1], -r1, lsr #25 │ │ │ │ mvnle r2, r0, lsl #16 │ │ │ │ ldrbtmi r4, [fp], #-2900 @ 0xfffff4ac │ │ │ │ @ instruction: 0xf7ec6818 │ │ │ │ strb pc, [r4, #-3277]! @ 0xfffff333 @ │ │ │ │ stmdage ip!, {r3, r8, r9, sl, fp, sp, pc} │ │ │ │ - @ instruction: 0xf7e34639 │ │ │ │ - ldmib sp, {r0, r1, r5, r7, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7e44639 │ │ │ │ + ldmib sp, {r0, r1, r2, r4, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf020010a │ │ │ │ - vldr s30, [pc, #628] @ 293b4 │ │ │ │ + vldr s30, [pc, #628] @ 2933c │ │ │ │ mcrr 11, 4, r7, r1, cr3 │ │ │ │ ldmib sp, {r1, r2, r4, r8, r9, fp}^ │ │ │ │ cdp 1, 8, cr0, cr6, cr8, {0} │ │ │ │ @ instruction: 0xf0208b07 │ │ │ │ mcrr 10, 9, pc, r1, cr3 @ │ │ │ │ vmov.32 r0, d8[1] │ │ │ │ svcmi 0x00478b07 │ │ │ │ @@ -38601,145 +38596,145 @@ │ │ │ │ subvs r2, r3, r1, lsl #6 │ │ │ │ movwcs sp, #6659 @ 0x1a03 │ │ │ │ stc 0, cr6, [r0, #524] @ 0x20c │ │ │ │ @ instruction: 0xf8c08b04 │ │ │ │ ldmdavs r8!, {r3, r4, pc} │ │ │ │ stc2l 7, cr15, [r0], #-944 @ 0xfffffc50 │ │ │ │ stmdacs r0, {r0, r9, sl, lr} │ │ │ │ - blmi ddd934 <__bss_end__@@Base+0xd36cfc> │ │ │ │ + blmi ddd8bc <__bss_end__@@Base+0xd36d1c> │ │ │ │ ldmdavs r8, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ stc2 7, cr15, [ip], {236} @ 0xec │ │ │ │ svcmi 0x0034e40f │ │ │ │ - ldrbtmi r4, [pc], #-1537 @ 291b4 │ │ │ │ + ldrbtmi r4, [pc], #-1537 @ 2913c │ │ │ │ @ instruction: 0xf7ec6838 │ │ │ │ - bhi 18e7aa8 <__bss_end__@@Base+0x1840e70> │ │ │ │ + bhi 18e7a30 <__bss_end__@@Base+0x1840e90> │ │ │ │ @ instruction: 0x468068fb │ │ │ │ @ instruction: 0xf47f429a │ │ │ │ - bhi fe914434 <__bss_end__@@Base+0xfe86d7fc> │ │ │ │ + bhi fe9143bc <__bss_end__@@Base+0xfe86d81c> │ │ │ │ rscsvc pc, pc, #82837504 @ 0x4f00000 │ │ │ │ mulle r3, r3, r2 │ │ │ │ addsmi r6, r3, #58, 30 @ 0xe8 │ │ │ │ ldcge 4, cr15, [r2], {127} @ 0x7f │ │ │ │ mulslt sp, r4, r8 │ │ │ │ vsubw.s8 q9, q0, d20 │ │ │ │ @ instruction: 0xf8c90301 │ │ │ │ @ instruction: 0xf1bb3018 │ │ │ │ @ instruction: 0xf0000f01 │ │ │ │ @ instruction: 0xf1bb8133 │ │ │ │ @ instruction: 0xf47f0f02 │ │ │ │ svcmi 0x0023ac83 │ │ │ │ - blvs feefa3f8 <__bss_end__@@Base+0xfee537c0> │ │ │ │ + blvs feefa380 <__bss_end__@@Base+0xfee537e0> │ │ │ │ @ instruction: 0xf43f2b00 │ │ │ │ @ instruction: 0x4621aabb │ │ │ │ ldrmi r4, [r8, r0, asr #12] │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ ldmdbvs r8!, {r0, r2, r4, r5, r7, r9, fp, sp, pc} │ │ │ │ - @ instruction: 0xf7e44649 │ │ │ │ - stmdacs r0, {r0, r1, r2, r3, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - blge ff926418 <__bss_end__@@Base+0xff87f7e0> │ │ │ │ + @ instruction: 0xf7e54649 │ │ │ │ + stmdacs r0, {r0, r1, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ + blge ff9263a0 <__bss_end__@@Base+0xff87f800> │ │ │ │ andeq pc, r0, r8, asr #17 │ │ │ │ @ instruction: 0xf04fe46c │ │ │ │ @ instruction: 0xf7ff37ff │ │ │ │ ldmdavs r8!, {r1, r2, r4, r6, r8, r9, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf7ec9107 │ │ │ │ stmdbls r7, {r3, r5, r6, r8, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ ldmdavs r8!, {r0, r2, r3, r9, sl, fp, sp, pc} │ │ │ │ @ instruction: 0xf9f8f7ec │ │ │ │ str r6, [r8], -r7, asr #19 │ │ │ │ teqcc r3, #-872415232 @ 0xcc000000 │ │ │ │ andsmi r3, r3, r3, lsr r3 │ │ │ │ andeq r0, r0, r0 │ │ │ │ smlawbmi lr, r0, r4, r8 │ │ │ │ - andeq r4, r3, r2, asr #12 │ │ │ │ - andeq r4, r3, r8, lsl r6 │ │ │ │ - andeq r1, r3, r6, asr #16 │ │ │ │ - andeq r4, r3, ip, lsl #11 │ │ │ │ - andeq r4, r3, lr, asr #10 │ │ │ │ - andeq r1, r2, r6, lsl #26 │ │ │ │ - andeq r1, r2, r0, lsr #24 │ │ │ │ - andeq r4, r3, r6, asr r4 │ │ │ │ - andeq r4, r3, r6, lsl #8 │ │ │ │ - andeq r4, r3, ip, asr #7 │ │ │ │ - andeq r4, r3, r4, lsl #7 │ │ │ │ - andeq r4, r3, r6, ror r3 │ │ │ │ - andeq r4, r3, r0, lsr r3 │ │ │ │ + andeq r4, r3, r2, lsr #12 │ │ │ │ + strdeq r4, [r3], -r8 │ │ │ │ + andeq r1, r3, r6, lsr #16 │ │ │ │ + andeq r4, r3, ip, ror #10 │ │ │ │ + andeq r4, r3, lr, lsr #10 │ │ │ │ + andeq r1, r2, r2, asr #30 │ │ │ │ + andeq r1, r2, ip, asr lr │ │ │ │ + andeq r4, r3, r6, lsr r4 │ │ │ │ + andeq r4, r3, r6, ror #7 │ │ │ │ + andeq r4, r3, ip, lsr #7 │ │ │ │ + andeq r4, r3, r4, ror #6 │ │ │ │ + andeq r4, r3, r6, asr r3 │ │ │ │ + andeq r4, r3, r0, lsl r3 │ │ │ │ streq pc, [r1, -pc, rrx] │ │ │ │ - bllt 92728c <__bss_end__@@Base+0x880654> │ │ │ │ + bllt 927214 <__bss_end__@@Base+0x880674> │ │ │ │ stmmi r2, {r0, r1, r9, sl, lr} │ │ │ │ rsbvc pc, r2, #1325400064 @ 0x4f000000 │ │ │ │ biccs pc, r3, r0, asr #4 │ │ │ │ @ instruction: 0xf7ea4478 │ │ │ │ - blls 1a8138 <__bss_end__@@Base+0x101500> │ │ │ │ + blls 1a8360 <__bss_end__@@Base+0x1017c0> │ │ │ │ ldrbmi r4, [r9], -r3, lsl #13 │ │ │ │ @ instruction: 0xf7ec6818 │ │ │ │ @ instruction: 0x4607fa35 │ │ │ │ stmdage ip!, {r0, r2, r3, r4, r5, r9, sl, sp, lr, pc} │ │ │ │ @ instruction: 0xffa8f7fd │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0xf7ffab0b │ │ │ │ @ instruction: 0xf7fff86b │ │ │ │ - blmi 1dd7ee4 <__bss_end__@@Base+0x1d312ac> │ │ │ │ + blmi 1dd7e6c <__bss_end__@@Base+0x1d312cc> │ │ │ │ @ instruction: 0x675a447b │ │ │ │ - bllt fff672cc <__bss_end__@@Base+0xffec0694> │ │ │ │ + bllt fff67254 <__bss_end__@@Base+0xffec06b4> │ │ │ │ @ instruction: 0xf7fe4621 │ │ │ │ @ instruction: 0xf7fff84b │ │ │ │ - bhi fe917ed0 <__bss_end__@@Base+0xfe871298> │ │ │ │ + bhi fe917e58 <__bss_end__@@Base+0xfe8712b8> │ │ │ │ @ instruction: 0xf43f4543 │ │ │ │ svcvs 0x0012af25 │ │ │ │ @ instruction: 0xf47f4293 │ │ │ │ @ instruction: 0xf10dab50 │ │ │ │ - bhi ff8ebf70 <__bss_end__@@Base+0xff845338> │ │ │ │ + bhi ff8ebef8 <__bss_end__@@Base+0xff845358> │ │ │ │ ldrbmi sl, [r9], -ip, lsr #16 │ │ │ │ - @ instruction: 0xf7e39305 │ │ │ │ - ldmib sp, {r0, r6, r7, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7e49305 │ │ │ │ + ldmib sp, {r0, r2, r4, r5, r7, r8, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf020010a │ │ │ │ @ instruction: 0xed9ff9bb │ │ │ │ mcrr 11, 6, r7, r1, cr4 │ │ │ │ ldmib sp, {r1, r2, r4, r8, r9, fp}^ │ │ │ │ cdp 1, 8, cr0, cr6, cr8, {0} │ │ │ │ @ instruction: 0xf0208b07 │ │ │ │ - blls 1a79dc <__bss_end__@@Base+0x100da4> │ │ │ │ - bleq 624420 <__bss_end__@@Base+0x57d7e8> │ │ │ │ + blls 1a7964 <__bss_end__@@Base+0x100dc4> │ │ │ │ + bleq 6243a8 <__bss_end__@@Base+0x57d808> │ │ │ │ cdp 5, 3, cr4, cr8, cr3, {2} │ │ │ │ @ instruction: 0xf43f8b07 │ │ │ │ @ instruction: 0xf7ffaf1a │ │ │ │ - bhi fe91804c <__bss_end__@@Base+0xfe871414> │ │ │ │ + bhi fe917fd4 <__bss_end__@@Base+0xfe871434> │ │ │ │ @ instruction: 0xf43f4543 │ │ │ │ svcvs 0x0012aeb8 │ │ │ │ @ instruction: 0xf47f4293 │ │ │ │ @ instruction: 0xf10dac3c │ │ │ │ - bhi ff8ebfc0 <__bss_end__@@Base+0xff845388> │ │ │ │ + bhi ff8ebf48 <__bss_end__@@Base+0xff8453a8> │ │ │ │ ldrbmi sl, [r9], -ip, lsr #16 │ │ │ │ - @ instruction: 0xf7e39305 │ │ │ │ - ldmib sp, {r0, r3, r4, r7, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7e49305 │ │ │ │ + ldmib sp, {r0, r2, r3, r7, r8, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf020010a │ │ │ │ @ instruction: 0xed9ff993 │ │ │ │ mcrr 11, 5, r7, r1, cr0 │ │ │ │ ldmib sp, {r1, r2, r4, r8, r9, fp}^ │ │ │ │ cdp 1, 8, cr0, cr6, cr8, {0} │ │ │ │ @ instruction: 0xf0208b07 │ │ │ │ - blls 1a798c <__bss_end__@@Base+0x100d54> │ │ │ │ - bleq 624470 <__bss_end__@@Base+0x57d838> │ │ │ │ + blls 1a7914 <__bss_end__@@Base+0x100d74> │ │ │ │ + bleq 6243f8 <__bss_end__@@Base+0x57d858> │ │ │ │ cdp 5, 3, cr4, cr8, cr3, {2} │ │ │ │ @ instruction: 0xf43f8b07 │ │ │ │ ldrt sl, [r4], #-3757 @ 0xfffff153 │ │ │ │ ldrdhi pc, [r8, -pc]! @ │ │ │ │ ldrbtmi r4, [r8], #1537 @ 0x601 │ │ │ │ ldrdeq pc, [r0], -r8 │ │ │ │ @ instruction: 0xf954f7ec │ │ │ │ svccs 0x00006807 │ │ │ │ stmiage r8!, {r0, r1, r2, r3, r4, r5, sl, ip, sp, lr, pc} │ │ │ │ - blvc 1e49f4 <__bss_end__@@Base+0x13ddbc> │ │ │ │ - blvc ff264e68 <__bss_end__@@Base+0xff1be230> │ │ │ │ - blx 464f60 <__bss_end__@@Base+0x3be328> │ │ │ │ + blvc 1e497c <__bss_end__@@Base+0x13dddc> │ │ │ │ + blvc ff264df0 <__bss_end__@@Base+0xff1be250> │ │ │ │ + blx 464ee8 <__bss_end__@@Base+0x3be348> │ │ │ │ movwcs fp, #12196 @ 0x2fa4 │ │ │ │ - ble 1014b0 <__bss_end__@@Base+0x5a878> │ │ │ │ + ble 101438 <__bss_end__@@Base+0x5a898> │ │ │ │ addvs r2, r3, r2, lsl #6 │ │ │ │ - blhi 1649ac <__bss_end__@@Base+0xbdd74> │ │ │ │ + blhi 164934 <__bss_end__@@Base+0xbdd94> │ │ │ │ mlacc r1, r4, r8, pc @ │ │ │ │ svclt 0x0044079b │ │ │ │ orrvs r2, r3, r1, lsl #6 │ │ │ │ @ instruction: 0xf8dfe41d │ │ │ │ strmi r8, [r1], -ip, ror #1 │ │ │ │ @ instruction: 0xf8d844f8 │ │ │ │ @ instruction: 0xf7ec0000 │ │ │ │ @@ -38750,386 +38745,386 @@ │ │ │ │ vsqrt.f64 d23, d8 │ │ │ │ svclt 0x00a4fa10 │ │ │ │ subvs r2, r3, r1, lsl #6 │ │ │ │ movwcs sp, #6659 @ 0x1a03 │ │ │ │ stc 0, cr6, [r0, #524] @ 0x20c │ │ │ │ movwcs r8, #2820 @ 0xb04 │ │ │ │ @ instruction: 0xf7ff6183 │ │ │ │ - blmi b97fa8 <__bss_end__@@Base+0xaf1370> │ │ │ │ + blmi b97f30 <__bss_end__@@Base+0xaf1390> │ │ │ │ ldrbtmi r4, [fp], #-1625 @ 0xfffff9a7 │ │ │ │ @ instruction: 0xf7ec6818 │ │ │ │ stmibvs r3, {r0, r1, r2, r4, r8, fp, ip, sp, lr, pc}^ │ │ │ │ ldrdlt pc, [r0], -r3 │ │ │ │ ldrtmi lr, [r8], -sl, lsl #9 │ │ │ │ ldrbcc pc, [pc, pc, asr #32]! @ │ │ │ │ @ instruction: 0xffc2f7fe │ │ │ │ - blt 1827414 <__bss_end__@@Base+0x17807dc> │ │ │ │ + blt 182739c <__bss_end__@@Base+0x17807fc> │ │ │ │ ldrbtmi r4, [fp], #-2853 @ 0xfffff4db │ │ │ │ @ instruction: 0xf7ff679a │ │ │ │ @ instruction: 0xf8d7bb59 │ │ │ │ - blcs 36228 │ │ │ │ - blge 1966528 <__bss_end__@@Base+0x18bf8f0> │ │ │ │ + blcs 361b0 │ │ │ │ + blge 19664b0 <__bss_end__@@Base+0x18bf910> │ │ │ │ orrne pc, r4, #14090240 @ 0xd70000 │ │ │ │ ldrmi r4, [r8, r0, lsr #12] │ │ │ │ - bllt 17e7434 <__bss_end__@@Base+0x17407fc> │ │ │ │ + bllt 17e73bc <__bss_end__@@Base+0x174081c> │ │ │ │ orrcc pc, r0, #14090240 @ 0xd70000 │ │ │ │ @ instruction: 0xf8d7b11b │ │ │ │ strtmi r1, [r0], -r4, lsl #7 │ │ │ │ movwcs r4, #6040 @ 0x1798 │ │ │ │ movwcc lr, #2503 @ 0x9c7 │ │ │ │ adcsvs r2, fp, r3, lsl #6 │ │ │ │ - bllt 1467450 <__bss_end__@@Base+0x13c0818> │ │ │ │ + bllt 14673d8 <__bss_end__@@Base+0x13c0838> │ │ │ │ @ instruction: 0x46214b17 │ │ │ │ ldrbtmi r4, [fp], #-1600 @ 0xfffff9c0 │ │ │ │ - blvs fe80e074 <__bss_end__@@Base+0xfe76743c> │ │ │ │ - blls 17b344 <__bss_end__@@Base+0xd470c> │ │ │ │ + blvs fe80dffc <__bss_end__@@Base+0xfe76745c> │ │ │ │ + blls 17b2cc <__bss_end__@@Base+0xd472c> │ │ │ │ svclt 0x00183f00 │ │ │ │ stmdacs r0, {r0, r8, r9, sl, sp} │ │ │ │ smladcs r0, r8, pc, fp @ │ │ │ │ @ instruction: 0xf43f2f00 │ │ │ │ ldmdbvs r8, {r0, r7, r8, fp, sp, pc} │ │ │ │ - @ instruction: 0xf7e44649 │ │ │ │ - stmdacs r0, {r0, r1, r3, r4, r6, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ - bge fec26680 <__bss_end__@@Base+0xfeb7fa48> │ │ │ │ + @ instruction: 0xf7e54649 │ │ │ │ + stmdacs r0, {r0, r1, r2, r3, r6, r8, fp, ip, sp, lr, pc} │ │ │ │ + bge fec26608 <__bss_end__@@Base+0xfeb7fa68> │ │ │ │ andlt pc, r0, r8, asr #17 │ │ │ │ - bllt e67488 <__bss_end__@@Base+0xdc0850> │ │ │ │ - svc 0x0096f7d9 │ │ │ │ + bllt e67410 <__bss_end__@@Base+0xdc0870> │ │ │ │ + svc 0x00aef7d9 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ smlawbmi lr, r0, r4, r8 │ │ │ │ - andeq r1, r2, r4, lsl #20 │ │ │ │ - andeq r4, r3, r0, ror #4 │ │ │ │ - andeq r4, r3, sl, lsr #3 │ │ │ │ - andeq r4, r3, r8, ror #2 │ │ │ │ - andeq r4, r3, lr, lsr #2 │ │ │ │ + andeq r1, r2, r0, asr #24 │ │ │ │ + andeq r4, r3, r0, asr #4 │ │ │ │ + andeq r4, r3, sl, lsl #3 │ │ │ │ + andeq r4, r3, r8, asr #2 │ │ │ │ andeq r4, r3, lr, lsl #2 │ │ │ │ - andeq r4, r3, lr, asr #1 │ │ │ │ + andeq r4, r3, lr, ror #1 │ │ │ │ + andeq r4, r3, lr, lsr #1 │ │ │ │ ldrbtmi r4, [fp], #-2821 @ 0xfffff4fb │ │ │ │ @ instruction: 0xb12b681b │ │ │ │ ldrbtmi r4, [fp], #-2820 @ 0xfffff4fc │ │ │ │ tstlt fp, fp, lsl r9 │ │ │ │ svclt 0x00eaf7fe │ │ │ │ ldrbmi r2, [r0, -r0]! │ │ │ │ - andeq r1, r3, lr, asr #5 │ │ │ │ - andeq r4, r3, r6, rrx │ │ │ │ + andeq r1, r3, lr, lsr #5 │ │ │ │ + andeq r4, r3, r6, asr #32 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 164998 <__bss_end__@@Base+0xbdd60> │ │ │ │ + blhi 164920 <__bss_end__@@Base+0xbdd80> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00c0f8cc │ │ │ │ addlt r4, r6, sp, asr #22 │ │ │ │ ldrbtmi r4, [fp], #-2381 @ 0xfffff6b3 │ │ │ │ ldrbtmi r4, [r9], #-2637 @ 0xfffff5b3 │ │ │ │ ldmdavs fp, {r0, r2, r3, r6, r8, r9, sl, fp, lr} │ │ │ │ stmpl sl, {r0, r1, r2, r3, r4, r5, r6, sl, lr} │ │ │ │ andls r6, r5, #1179648 @ 0x120000 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ subsle r2, r7, r0, lsl #22 │ │ │ │ ldrbtmi r4, [sp], #-3401 @ 0xfffff2b7 │ │ │ │ - blcs 439c0 │ │ │ │ + blcs 43948 │ │ │ │ svcvs 0x00ebd052 │ │ │ │ - blcs 3ad2c │ │ │ │ - bmi 11dda98 <__bss_end__@@Base+0x1136e60> │ │ │ │ + blcs 3acb4 │ │ │ │ + bmi 11dda20 <__bss_end__@@Base+0x1136e80> │ │ │ │ adcvs r5, fp, #12189696 @ 0xba0000 │ │ │ │ movwcs lr, #2514 @ 0x9d2 │ │ │ │ movwcs lr, #27077 @ 0x69c5 │ │ │ │ @ instruction: 0xffb8f7fe │ │ │ │ stclle 12, cr2, [r3, #-0] │ │ │ │ @ instruction: 0xf44f4e41 │ │ │ │ @ instruction: 0xf8df75fa │ │ │ │ ldrbtmi r8, [lr], #-260 @ 0xfffffefc │ │ │ │ - blls de4bc0 <__bss_end__@@Base+0xd3df88> │ │ │ │ + blls de4b48 <__bss_end__@@Base+0xd3dfa8> │ │ │ │ @ instruction: 0xe01244f8 │ │ │ │ ldmpl sl!, {r0, r1, r3, r4, r5, r9, fp, lr} │ │ │ │ ldmib r2, {r0, r1, r4, r5, r7, r9, sp, lr}^ │ │ │ │ stmib r6, {r8, r9, sp}^ │ │ │ │ @ instruction: 0xf8d82306 │ │ │ │ @ instruction: 0xb12b3000 │ │ │ │ ldrbtmi r4, [fp], #-2873 @ 0xfffff4c7 │ │ │ │ tstlt fp, fp, lsl r9 │ │ │ │ @ instruction: 0xff9cf7fe │ │ │ │ @ instruction: 0x2c001b64 │ │ │ │ adcmi sp, r5, #2432 @ 0x980 │ │ │ │ rsbsvc pc, sl, pc, asr #8 │ │ │ │ strtmi fp, [r5], -r8, lsr #31 │ │ │ │ @ instruction: 0xf000fb05 │ │ │ │ - stcl 7, cr15, [ip, #868] @ 0x364 │ │ │ │ + stcl 7, cr15, [r2, #868]! @ 0x364 │ │ │ │ mrc2 0, 3, pc, cr8, cr11, {0} │ │ │ │ - blcs 45554 │ │ │ │ + blcs 454dc │ │ │ │ ldrdcs sp, [r0, -lr] │ │ │ │ @ instruction: 0xf7d94668 │ │ │ │ - ldmib sp, {r1, r5, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmib sp, {r3, r4, r5, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0200102 │ │ │ │ mcrr 8, 6, pc, r1, cr15 @ │ │ │ │ ldmib sp, {r0, r1, r2, r4, r8, r9, fp}^ │ │ │ │ cdp 1, 8, cr0, cr7, cr0, {0} │ │ │ │ @ instruction: 0xf0208b09 │ │ │ │ mcrr 8, 6, pc, r1, cr7 @ │ │ │ │ movwcs r0, #6935 @ 0x1b17 │ │ │ │ mrc 2, 1, r6, cr8, cr3, {5} │ │ │ │ vstr d8, [r6, #28] │ │ │ │ strb r8, [ip, r6, lsl #22] │ │ │ │ - blmi 6fbe48 <__bss_end__@@Base+0x655210> │ │ │ │ + blmi 6fbdd0 <__bss_end__@@Base+0x655230> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 183630 <__bss_end__@@Base+0xdc9f8> │ │ │ │ + blls 1835b8 <__bss_end__@@Base+0xdca18> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xd1200300 │ │ │ │ andlt r2, r6, r0 │ │ │ │ - blhi 1648cc <__bss_end__@@Base+0xbdc94> │ │ │ │ + blhi 164854 <__bss_end__@@Base+0xbdcb4> │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ strbtmi r2, [r8], -r0, lsl #2 │ │ │ │ - ldc 7, cr15, [r8, #-868]! @ 0xfffffc9c │ │ │ │ + stcl 7, cr15, [lr, #-868] @ 0xfffffc9c │ │ │ │ ldrdeq lr, [r2, -sp] │ │ │ │ @ instruction: 0xf846f020 │ │ │ │ - blvc 324c6c <__bss_end__@@Base+0x27e034> │ │ │ │ - bleq 5e46f8 <__bss_end__@@Base+0x53dac0> │ │ │ │ + blvc 324bf4 <__bss_end__@@Base+0x27e054> │ │ │ │ + bleq 5e4680 <__bss_end__@@Base+0x53dae0> │ │ │ │ ldrdeq lr, [r0, -sp] │ │ │ │ - blhi 225014 <__bss_end__@@Base+0x17e3dc> │ │ │ │ + blhi 224f9c <__bss_end__@@Base+0x17e3fc> │ │ │ │ @ instruction: 0xf83cf020 │ │ │ │ - bleq 624708 <__bss_end__@@Base+0x57dad0> │ │ │ │ + bleq 624690 <__bss_end__@@Base+0x57daf0> │ │ │ │ adcvs r2, fp, #67108864 @ 0x4000000 │ │ │ │ - blhi 224eec <__bss_end__@@Base+0x17e2b4> │ │ │ │ - blhi 1e4c24 <__bss_end__@@Base+0x13dfec> │ │ │ │ + blhi 224e74 <__bss_end__@@Base+0x17e2d4> │ │ │ │ + blhi 1e4bac <__bss_end__@@Base+0x13e00c> │ │ │ │ @ instruction: 0xf7d9e78c │ │ │ │ - svclt 0x0000eed4 │ │ │ │ + svclt 0x0000eeec │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ smlawbmi lr, r0, r4, r8 │ │ │ │ - muleq r3, r6, r2 │ │ │ │ - andeq lr, r2, sl, lsl #22 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq lr, r2, r4, lsl #22 │ │ │ │ - andeq r4, r3, sl, lsl r0 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - andeq r3, r3, sl, ror #31 │ │ │ │ - andeq r1, r3, r4, asr #4 │ │ │ │ + andeq r1, r3, r6, ror r2 │ │ │ │ + andeq lr, r2, r2, lsl #23 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq lr, r2, ip, ror fp │ │ │ │ + strdeq r3, [r3], -sl │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ andeq r3, r3, sl, asr #31 │ │ │ │ - andeq lr, r2, r0, asr #20 │ │ │ │ + andeq r1, r3, r4, lsr #4 │ │ │ │ + andeq r3, r3, sl, lsr #31 │ │ │ │ + @ instruction: 0x0002eab8 │ │ │ │ stcmi 4, cr11, [sl], {240} @ 0xf0 │ │ │ │ ldrbtmi r9, [ip], #-3332 @ 0xfffff2fc │ │ │ │ stmdavs r4!, {r0, r2, r9, sl, fp, ip, pc} │ │ │ │ stcmi 1, cr11, [r8], {44} @ 0x2c │ │ │ │ stmdbvs r7!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ stmdavs r4!, {r0, r1, r2, r3, r8, ip, sp, pc}^ │ │ │ │ andcs fp, r0, r4, lsl r1 │ │ │ │ @ instruction: 0x4770bcf0 │ │ │ │ strpl lr, [r4], -sp, asr #19 │ │ │ │ @ instruction: 0xf7febcf0 │ │ │ │ svclt 0x0000baa5 │ │ │ │ - andeq r1, r3, r6, lsr r1 │ │ │ │ - andeq r3, r3, ip, asr #29 │ │ │ │ + andeq r1, r3, r6, lsl r1 │ │ │ │ + andeq r3, r3, ip, lsr #29 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0048f8cc │ │ │ │ - bmi f3aeec <__bss_end__@@Base+0xe942b4> │ │ │ │ + bmi f3ae74 <__bss_end__@@Base+0xe942d4> │ │ │ │ ldrsbthi pc, [r0], #143 @ 0x8f @ │ │ │ │ - blmi f3af10 <__bss_end__@@Base+0xe942d8> │ │ │ │ + blmi f3ae98 <__bss_end__@@Base+0xe942f8> │ │ │ │ ldrbtmi r4, [r8], #1146 @ 0x47a │ │ │ │ adclt r4, r7, r4, lsl #12 │ │ │ │ strtmi r4, [r1], -pc, lsl #12 │ │ │ │ @ instruction: 0xf8d858d3 │ │ │ │ ldmdavs fp, {} @ │ │ │ │ @ instruction: 0xf04f9325 │ │ │ │ @ instruction: 0xf7eb0300 │ │ │ │ stmdblt r0!, {r2, r5, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - blmi cfbf90 <__bss_end__@@Base+0xc55358> │ │ │ │ + blmi cfbf18 <__bss_end__@@Base+0xc55378> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 983730 <__bss_end__@@Base+0x8dcaf8> │ │ │ │ + blls 9836b8 <__bss_end__@@Base+0x8dcb18> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, SPSR_mon │ │ │ │ pop {r0, r1, r2, r5, ip, sp, pc} │ │ │ │ @ instruction: 0x462183f0 │ │ │ │ ldrdeq pc, [r0], -r8 │ │ │ │ @ instruction: 0xffa8f7eb │ │ │ │ strmi r6, [r4], -r3, lsl #16 │ │ │ │ cmple r2, r0, lsl #22 │ │ │ │ - blvc 264d2c <__bss_end__@@Base+0x1be0f4> │ │ │ │ + blvc 264cb4 <__bss_end__@@Base+0x1be114> │ │ │ │ ldmdbeq r0, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ - bleq 1e4d54 <__bss_end__@@Base+0x13e11c> │ │ │ │ + bleq 1e4cdc <__bss_end__@@Base+0x13e13c> │ │ │ │ stmdavc r4!, {r2, r8, sl, ip, sp, lr, pc} │ │ │ │ strbmi r3, [fp], -r0, asr #32 │ │ │ │ strbmi sl, [r1], -r1, lsl #20 │ │ │ │ - bleq 1224fc4 <__bss_end__@@Base+0x117e38c> │ │ │ │ - ldc2 7, cr15, [r1, #908]! @ 0x38c │ │ │ │ - bpl a4d80 <__bss_start@@Base+0x49ce0> │ │ │ │ - bvs e4d84 <__bss_end__@@Base+0x3e14c> │ │ │ │ + bleq 1224f4c <__bss_end__@@Base+0x117e3ac> │ │ │ │ + @ instruction: 0xf9a5f7e4 │ │ │ │ + bpl a4d08 <__bss_start@@Base+0x49d00> │ │ │ │ + bvs e4d0c <__bss_end__@@Base+0x3e16c> │ │ │ │ teqpvc sl, #4, 10 @ p-variant is OBSOLETE @ 0x1000000 │ │ │ │ - bvc 124d8c <__bss_end__@@Base+0x7e154> │ │ │ │ + bvc 124d14 <__bss_end__@@Base+0x7e174> │ │ │ │ eorsvc pc, r8, #4, 10 @ 0x1000000 │ │ │ │ - bpl ff1a51fc <__bss_end__@@Base+0xff0fe5c4> │ │ │ │ + bpl ff1a5184 <__bss_end__@@Base+0xff0fe5e4> │ │ │ │ teqpvc r6, r4, lsl #10 @ p-variant is OBSOLETE │ │ │ │ - bvs ff1e5204 <__bss_end__@@Base+0xff13e5cc> │ │ │ │ + bvs ff1e518c <__bss_end__@@Base+0xff13e5ec> │ │ │ │ cdp 6, 11, cr4, cr7, cr8, {2} │ │ │ │ @ instruction: 0xf5047ac7 │ │ │ │ stc 4, cr7, [r4, #168] @ 0xa8 │ │ │ │ vstr d5, [r4] │ │ │ │ vstr d6, [r4, #8] │ │ │ │ - @ instruction: 0xf7e17b04 │ │ │ │ - strbmi pc, [r4], pc, ror #29 @ │ │ │ │ + @ instruction: 0xf7e27b04 │ │ │ │ + strbmi pc, [r4], r1, lsr #18 @ │ │ │ │ @ instruction: 0x46324639 │ │ │ │ ldm ip!, {r0, r1, r3, r5, r9, sl, lr}^ │ │ │ │ stmia r1!, {r1, r8, r9, sl, sp, lr}^ │ │ │ │ strmi r6, [r4, #1794]! @ 0x702 │ │ │ │ @ instruction: 0x6704e9dc │ │ │ │ strvs lr, [r2, -r2, ror #17] │ │ │ │ @ instruction: 0x6710e9dc │ │ │ │ strvs lr, [r2, -r3, ror #17] │ │ │ │ strdcs sp, [r1], -r1 │ │ │ │ @ instruction: 0xf7d9e7a8 │ │ │ │ - blmi 2a5010 <__bss_end__@@Base+0x1fe3d8> │ │ │ │ + blmi 2a4ff8 <__bss_end__@@Base+0x1fe458> │ │ │ │ andvc pc, sp, #64, 4 │ │ │ │ stmdami r9, {r3, r8, fp, lr} │ │ │ │ ldrbtmi r4, [r9], #-1147 @ 0xfffffb85 │ │ │ │ ldrbtmi r3, [r8], #-792 @ 0xfffffce8 │ │ │ │ - ldc 7, cr15, [r8], #868 @ 0x364 │ │ │ │ - andeq lr, r2, r4, ror #18 │ │ │ │ - andeq r3, r3, sl, lsl #29 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq lr, r2, r0, asr #18 │ │ │ │ - andeq ip, r2, r0, asr sp │ │ │ │ - andeq r1, r2, r6, lsr #10 │ │ │ │ - andeq r1, r2, r6, asr #12 │ │ │ │ + stcl 7, cr15, [lr], {217} @ 0xd9 │ │ │ │ + ldrdeq lr, [r2], -ip │ │ │ │ + andeq r3, r3, sl, ror #28 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + @ instruction: 0x0002e9b8 │ │ │ │ + andeq ip, r2, r8, asr #25 │ │ │ │ + andeq r1, r2, r2, ror #14 │ │ │ │ + andeq r1, r2, r2, lsl #17 │ │ │ │ movwcs lr, #10717 @ 0x29dd │ │ │ │ andsvs r2, r0, r0 │ │ │ │ @ instruction: 0x47706018 │ │ │ │ ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0078f8cc │ │ │ │ @ instruction: 0x46174e59 │ │ │ │ @ instruction: 0x469a4a59 │ │ │ │ - blmi 167a9c0 <__bss_end__@@Base+0x15d3d88> │ │ │ │ + blmi 167a948 <__bss_end__@@Base+0x15d3da8> │ │ │ │ sxtab16mi r4, r4, sl, ror #8 │ │ │ │ ldmdavs r0!, {r1, r3, r4, r7, ip, sp, pc} │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9319 │ │ │ │ cmplt r8, r0, lsl #6 │ │ │ │ ldrsbls pc, [r0, #-143] @ 0xffffff71 @ │ │ │ │ @ instruction: 0xf8d944f9 │ │ │ │ @ instruction: 0xb1280010 │ │ │ │ ldrdhi pc, [r4], -r9 │ │ │ │ @ instruction: 0xf1b82000 │ │ │ │ andle r0, ip, r0, lsl #30 │ │ │ │ - blmi 137c134 <__bss_end__@@Base+0x12d54fc> │ │ │ │ + blmi 137c0bc <__bss_end__@@Base+0x12d551c> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 683868 <__bss_end__@@Base+0x5dcc30> │ │ │ │ + blls 6837f0 <__bss_end__@@Base+0x5dcc50> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ cmnle pc, r0, lsl #6 │ │ │ │ pop {r1, r3, r4, ip, sp, pc} │ │ │ │ @ instruction: 0xf50c87f0 │ │ │ │ strmi r5, [ip], -r0, lsl #1 │ │ │ │ @ instruction: 0xf88d2302 │ │ │ │ stcge 0, cr3, [sl, #-8] │ │ │ │ @ instruction: 0xf8d03620 │ │ │ │ @ instruction: 0xf8d910a8 │ │ │ │ @ instruction: 0xf7eb0000 │ │ │ │ - bmi 1129438 <__bss_end__@@Base+0x1082800> │ │ │ │ + bmi 11293c0 <__bss_end__@@Base+0x1082820> │ │ │ │ @ instruction: 0xf8d04603 │ │ │ │ ldrbtmi r0, [sl], #-42 @ 0xffffffd6 │ │ │ │ @ instruction: 0xf1029003 │ │ │ │ ldclhi 1, cr0, [fp, #192] @ 0xc0 │ │ │ │ @ instruction: 0xf8cd6b10 │ │ │ │ stmdbgt r3, {r1, r4} │ │ │ │ andscc pc, r0, sp, lsr #17 │ │ │ │ cdphi 0, 9, cr9, cr3, cr6, {0} │ │ │ │ andsne pc, ip, sp, lsr #17 │ │ │ │ tstpeq lr, sp, lsl #2 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0x0010f8d9 │ │ │ │ andscc pc, r6, sp, lsr #17 │ │ │ │ - blx ff9a77f2 <__bss_end__@@Base+0xff900bba> │ │ │ │ - blmi ae4ee0 <__bss_end__@@Base+0xa3e2a8> │ │ │ │ + @ instruction: 0xffd9f7e4 │ │ │ │ + blmi ae4e68 <__bss_end__@@Base+0xa3e2c8> │ │ │ │ ldc 3, cr2, [r7] │ │ │ │ vldr d7, [r7] │ │ │ │ vldr d5, [r7, #8] │ │ │ │ - bls 8c4484 <__bss_end__@@Base+0x81d84c> │ │ │ │ - blvc 165114 <__bss_end__@@Base+0xbe4dc> │ │ │ │ - blpl 165110 <__bss_end__@@Base+0xbe4d8> │ │ │ │ + bls 8c440c <__bss_end__@@Base+0x81d86c> │ │ │ │ + blvc 16509c <__bss_end__@@Base+0xbe4fc> │ │ │ │ + blpl 165098 <__bss_end__@@Base+0xbe4f8> │ │ │ │ subcs pc, lr, sp, lsr #17 │ │ │ │ - blvs 16511c <__bss_end__@@Base+0xbe4e4> │ │ │ │ + blvs 1650a4 <__bss_end__@@Base+0xbe504> │ │ │ │ stcgt 3, cr9, [pc], {23} │ │ │ │ - blvc ff225368 <__bss_end__@@Base+0xff17e730> │ │ │ │ - blpl ff1a536c <__bss_end__@@Base+0xff0fe734> │ │ │ │ + blvc ff2252f0 <__bss_end__@@Base+0xff17e750> │ │ │ │ + blpl ff1a52f4 <__bss_end__@@Base+0xff0fe754> │ │ │ │ cdp 5, 11, cr12, cr7, cr15, {0} │ │ │ │ - blge 4447b0 <__bss_end__@@Base+0x39db78> │ │ │ │ - blne 7e4f18 <__bss_end__@@Base+0x73e2e0> │ │ │ │ - bleq 1e4f04 <__bss_end__@@Base+0x13e2cc> │ │ │ │ + blge 444738 <__bss_end__@@Base+0x39db98> │ │ │ │ + blne 7e4ea0 <__bss_end__@@Base+0x73e300> │ │ │ │ + bleq 1e4e8c <__bss_end__@@Base+0x13e2ec> │ │ │ │ muleq r3, r4, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, r3, lsl #17 │ │ │ │ - bvc 564ee8 <__bss_end__@@Base+0x4be2b0> │ │ │ │ + bvc 564e70 <__bss_end__@@Base+0x4be2d0> │ │ │ │ ldrdvc pc, [r8], -r9 @ │ │ │ │ subge pc, ip, sp, lsr #17 │ │ │ │ eorhi pc, r4, sp, asr #17 │ │ │ │ subhi pc, r8, sp, asr #17 │ │ │ │ - bpl 5a4efc <__bss_end__@@Base+0x4fe2c4> │ │ │ │ - bvs 5e4f00 <__bss_end__@@Base+0x53e2c8> │ │ │ │ - mcr 7, 4, pc, cr6, cr9, {6} @ │ │ │ │ - blvc 4e4f50 <__bss_end__@@Base+0x43e318> │ │ │ │ + bpl 5a4e84 <__bss_end__@@Base+0x4fe2e4> │ │ │ │ + bvs 5e4e88 <__bss_end__@@Base+0x53e2e8> │ │ │ │ + mrc 7, 4, APSR_nzcv, cr0, cr9, {6} │ │ │ │ + blvc 4e4ed8 <__bss_end__@@Base+0x43e338> │ │ │ │ andmi pc, r0, #111 @ 0x6f │ │ │ │ - bleq 22515c <__bss_end__@@Base+0x17e524> │ │ │ │ - blvc ff0654d0 <__bss_end__@@Base+0xfefbe898> │ │ │ │ - bcc fe465140 <__bss_end__@@Base+0xfe3be508> │ │ │ │ + bleq 2250e4 <__bss_end__@@Base+0x17e544> │ │ │ │ + blvc ff065458 <__bss_end__@@Base+0xfefbe8b8> │ │ │ │ + bcc fe4650c8 <__bss_end__@@Base+0xfe3be528> │ │ │ │ svclt 0x00284293 │ │ │ │ tstlt pc, r3, lsl r6 @ │ │ │ │ movwvs pc, #67 @ 0x43 @ │ │ │ │ @ instruction: 0x46694a12 │ │ │ │ ldrbtmi r9, [sl], #-769 @ 0xfffffcff │ │ │ │ @ instruction: 0xf7e46910 │ │ │ │ - stmdacc r0, {r0, r1, r3, r4, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmdacc r0, {r0, r1, r2, r3, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ ldrb r4, [r5, -r0, asr #4]! │ │ │ │ - ldcl 7, cr15, [r8, #-868] @ 0xfffffc9c │ │ │ │ - bvs fe0b02d0 <__bss_end__@@Base+0xfe009698> │ │ │ │ + ldcl 7, cr15, [r0, #-868]! @ 0xfffffc9c │ │ │ │ + bvs fe0b0258 <__bss_end__@@Base+0xfe0096b8> │ │ │ │ svccc 0x00d381da │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ ldmvc sl, {r0, r3, r6, r7, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0x41223456 │ │ │ │ - andeq r0, r3, r4, asr #31 │ │ │ │ - andeq lr, r2, r8, lsr r8 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r3, r3, r8, asr #26 │ │ │ │ - andeq lr, r2, r8, lsl #16 │ │ │ │ - muleq r2, r6, ip │ │ │ │ - andeq r3, r3, r2, lsr ip │ │ │ │ + andeq r0, r3, r4, lsr #31 │ │ │ │ + @ instruction: 0x0002e8b0 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r3, r3, r8, lsr #26 │ │ │ │ + andeq lr, r2, r0, lsl #17 │ │ │ │ + andeq ip, r2, lr, lsl #24 │ │ │ │ + andeq r3, r3, r2, lsl ip │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0060f8cc │ │ │ │ - bmi fe13b394 <__bss_end__@@Base+0xfe09475c> │ │ │ │ - blmi fe13b3c4 <__bss_end__@@Base+0xfe09478c> │ │ │ │ + bmi fe13b31c <__bss_end__@@Base+0xfe09477c> │ │ │ │ + blmi fe13b34c <__bss_end__@@Base+0xfe0947ac> │ │ │ │ @ instruction: 0x4605447a │ │ │ │ ldmpl r3, {r0, r1, r2, r3, r4, r7, ip, sp, pc}^ │ │ │ │ ldmib sp, {r1, r7, r9, fp, lr}^ │ │ │ │ ldrbtmi r6, [sl], #-2344 @ 0xfffff6d8 │ │ │ │ ldrdge pc, [r8], sp @ │ │ │ │ tstls sp, #1769472 @ 0x1b0000 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ teqlt r0, r0, lsl r8 │ │ │ │ - ldrbtmi r4, [pc], #-3965 @ 2997c │ │ │ │ + ldrbtmi r4, [pc], #-3965 @ 29904 │ │ │ │ tstlt r0, r8, lsr r9 │ │ │ │ andcs r6, r0, sl, ror r8 │ │ │ │ - bmi 1f15f30 <__bss_end__@@Base+0x1e6f2f8> │ │ │ │ + bmi 1f15eb8 <__bss_end__@@Base+0x1e6f318> │ │ │ │ ldrbtmi r4, [sl], #-2935 @ 0xfffff489 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, sp, lsl fp │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ sbcshi pc, sl, r0, asr #32 │ │ │ │ pop {r0, r1, r2, r3, r4, ip, sp, pc} │ │ │ │ ldmdavs r8!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ strmi r2, [ip], -r3, lsl #4 │ │ │ │ andcs pc, r2, sp, lsl #17 │ │ │ │ stc2 7, cr15, [r9, #940]! @ 0x3ac │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ strtmi r8, [r1], -r7, asr #1 │ │ │ │ @ instruction: 0xf7eb6838 │ │ │ │ stmdavs r2, {r0, r3, r4, r5, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - bcs 3b1d4 │ │ │ │ + bcs 3b15c │ │ │ │ sbchi pc, r1, r0 │ │ │ │ svceq 0x0000f1b8 │ │ │ │ addhi pc, ip, r0, asr #32 │ │ │ │ @ instruction: 0xf8d04a69 │ │ │ │ ldrbtmi r0, [sl], #-42 @ 0xffffffd6 │ │ │ │ andls r8, r3, r1, ror #27 │ │ │ │ andsne pc, r0, sp, lsr #17 │ │ │ │ @@ -39141,66 +39136,66 @@ │ │ │ │ ldrbtmi r4, [sl], #-2657 @ 0xfffff59f │ │ │ │ ldm r2, {r4, r5, r9, ip, sp} │ │ │ │ andls r0, r6, r3 │ │ │ │ andsne pc, ip, sp, lsr #17 │ │ │ │ @ instruction: 0xf10d4c5e │ │ │ │ ldrbtmi r0, [ip], #-286 @ 0xfffffee2 │ │ │ │ @ instruction: 0xf7e46920 │ │ │ │ - vldr d15, [r9, #48] @ 0x30 │ │ │ │ + ldc 15, cr15, [r9] │ │ │ │ ldmib r6, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - bge 4a9e1c <__bss_end__@@Base+0x4031e4> │ │ │ │ - blcs 65088 <__bss_start@@Base+0x9fe8> │ │ │ │ - blvc ff225500 <__bss_end__@@Base+0xff17e8c8> │ │ │ │ - blcc e5090 <__bss_end__@@Base+0x3e458> │ │ │ │ + bge 4a9da4 <__bss_end__@@Base+0x403204> │ │ │ │ + blcs 65010 <__bss_start@@Base+0xa008> │ │ │ │ + blvc ff225488 <__bss_end__@@Base+0xff17e8e8> │ │ │ │ + blcc e5018 <__bss_end__@@Base+0x3e478> │ │ │ │ orrcc pc, r8, #268435460 @ 0x10000004 │ │ │ │ mvncc pc, #192, 4 │ │ │ │ - blmi 16509c <__bss_end__@@Base+0xbe464> │ │ │ │ - blpl 6509c <__bss_start@@Base+0x9ffc> │ │ │ │ - blcs ff0e5518 <__bss_end__@@Base+0xff03e8e0> │ │ │ │ - blvs e50a4 <__bss_end__@@Base+0x3e46c> │ │ │ │ - blcc ff125520 <__bss_end__@@Base+0xff07e8e8> │ │ │ │ + blmi 165024 <__bss_end__@@Base+0xbe484> │ │ │ │ + blpl 65024 <__bss_start@@Base+0xa01c> │ │ │ │ + blcs ff0e54a0 <__bss_end__@@Base+0xff03e900> │ │ │ │ + blvs e502c <__bss_end__@@Base+0x3e48c> │ │ │ │ + blcc ff1254a8 <__bss_end__@@Base+0xff07e908> │ │ │ │ smlabteq ip, sp, r9, lr │ │ │ │ - blmi ff165528 <__bss_end__@@Base+0xff0be8f0> │ │ │ │ + blmi ff1654b0 <__bss_end__@@Base+0xff0be910> │ │ │ │ ldrdeq lr, [r2, -r6] │ │ │ │ smlabteq lr, sp, r9, lr │ │ │ │ cdp 8, 11, cr6, cr7, cr8, {1} │ │ │ │ stmdavs r9!, {r0, r2, r6, r7, r8, r9, fp, ip, lr}^ │ │ │ │ - blvs ff1e553c <__bss_end__@@Base+0xff13e904> │ │ │ │ + blvs ff1e54c4 <__bss_end__@@Base+0xff13e924> │ │ │ │ vhsub.s8 d28, d0, d3 │ │ │ │ @ instruction: 0xf6c05114 │ │ │ │ ldc 1, cr3, [r4, #736] @ 0x2e0 │ │ │ │ @ instruction: 0xf89d0b06 │ │ │ │ andcs r0, r0, #76 @ 0x4c │ │ │ │ @ instruction: 0x6704e9d6 │ │ │ │ svclt 0x00182802 │ │ │ │ - ldc 6, cr4, [pc, #44] @ 29aac │ │ │ │ + ldc 6, cr4, [pc, #44] @ 29a34 │ │ │ │ tstcs r1, r5, lsr fp │ │ │ │ rsbcs pc, r4, sp, lsr #17 │ │ │ │ tstcc r4, sp, asr #19 │ │ │ │ stc 2, cr9, [sp, #104] @ 0x68 │ │ │ │ - bvs fe9482f4 <__bss_end__@@Base+0xfe8a16bc> │ │ │ │ + bvs fe94827c <__bss_end__@@Base+0xfe8a16dc> │ │ │ │ ldrvs lr, [r0, -sp, asr #19] │ │ │ │ - bcs 2a50d0 <__bss_end__@@Base+0x1fe498> │ │ │ │ - bcc 2e50d4 <__bss_end__@@Base+0x23e49c> │ │ │ │ - bmi 3250d8 <__bss_end__@@Base+0x27e4a0> │ │ │ │ - bpl 5e50dc <__bss_end__@@Base+0x53e4a4> │ │ │ │ - bvs 6250e0 <__bss_end__@@Base+0x57e4a8> │ │ │ │ - ldc 7, cr15, [r6, #868] @ 0x364 │ │ │ │ - blvc ae5130 <__bss_end__@@Base+0xa3e4f8> │ │ │ │ + bcs 2a5058 <__bss_end__@@Base+0x1fe4b8> │ │ │ │ + bcc 2e505c <__bss_end__@@Base+0x23e4bc> │ │ │ │ + bmi 325060 <__bss_end__@@Base+0x27e4c0> │ │ │ │ + bpl 5e5064 <__bss_end__@@Base+0x53e4c4> │ │ │ │ + bvs 625068 <__bss_end__@@Base+0x57e4c8> │ │ │ │ + stc 7, cr15, [r0, #868]! @ 0x364 │ │ │ │ + blvc ae50b8 <__bss_end__@@Base+0xa3e518> │ │ │ │ andmi pc, r0, #111 @ 0x6f │ │ │ │ - bleq 22533c <__bss_end__@@Base+0x17e704> │ │ │ │ - blvc ff0656b0 <__bss_end__@@Base+0xfefbea78> │ │ │ │ - bcc fe465320 <__bss_end__@@Base+0xfe3be6e8> │ │ │ │ + bleq 2252c4 <__bss_end__@@Base+0x17e724> │ │ │ │ + blvc ff065638 <__bss_end__@@Base+0xfefbea98> │ │ │ │ + bcc fe4652a8 <__bss_end__@@Base+0xfe3be708> │ │ │ │ svclt 0x00284293 │ │ │ │ tstlt ip, r3, lsl r6 │ │ │ │ movwvs pc, #67 @ 0x43 @ │ │ │ │ strbtmi r4, [r9], -ip, lsr #20 │ │ │ │ ldrbtmi r9, [sl], #-769 @ 0xfffffcff │ │ │ │ @ instruction: 0xf7e46910 │ │ │ │ - stmdacc r0, {r0, r1, r3, r5, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmdacc r0, {r0, r1, r2, r3, r4, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ strb r4, [lr, -r0, asr #4] │ │ │ │ @ instruction: 0x46416838 │ │ │ │ stc2 7, cr15, [r9, #-940] @ 0xfffffc54 │ │ │ │ @ instruction: 0xf06fb998 │ │ │ │ strb r0, [r6, -r1] │ │ │ │ ldrbmi r4, [r9], -r3, lsr #20 │ │ │ │ @@ -39221,188 +39216,188 @@ │ │ │ │ ldclhi 0, cr1, [r2, #168] @ 0xa8 │ │ │ │ @ instruction: 0xf8cd9003 │ │ │ │ @ instruction: 0xf8ad1012 │ │ │ │ smmla r3, r6, r0, r2 │ │ │ │ andeq pc, r2, pc, rrx │ │ │ │ @ instruction: 0xf04fe71d │ │ │ │ @ instruction: 0xe71a30ff │ │ │ │ - ldc 7, cr15, [r4], #-868 @ 0xfffffc9c │ │ │ │ + mcrr 7, 13, pc, ip, cr9 @ │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ ldmvc sl, {r0, r3, r6, r7, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0x41223456 │ │ │ │ - andeq lr, r2, r8, lsr #13 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r0, r3, r2, lsr #28 │ │ │ │ - andeq r3, r3, lr, lsr #23 │ │ │ │ - andeq lr, r2, r6, ror r6 │ │ │ │ - strdeq ip, [r2], -r2 │ │ │ │ - ldrdeq ip, [r2], -r2 │ │ │ │ - andeq r3, r3, lr, lsl fp │ │ │ │ - andeq r3, r3, r2, asr sl │ │ │ │ - andeq r3, r3, ip, lsr #20 │ │ │ │ + andeq lr, r2, r0, lsr #14 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r0, r3, r2, lsl #28 │ │ │ │ + andeq r3, r3, lr, lsl #23 │ │ │ │ + andeq lr, r2, lr, ror #13 │ │ │ │ + andeq ip, r2, sl, ror #20 │ │ │ │ + andeq ip, r2, sl, asr #20 │ │ │ │ + strdeq r3, [r3], -lr │ │ │ │ + andeq r3, r3, r2, lsr sl │ │ │ │ + andeq r3, r3, ip, lsl #20 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8c7a0 <__bss_end__@@Base+0xfeae5b68> │ │ │ │ + bl feb8c728 <__bss_end__@@Base+0xfeae5b88> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi e6db40 <__bss_end__@@Base+0xdc6f08> │ │ │ │ + blmi e6dac8 <__bss_end__@@Base+0xdc6f28> │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrbtmi r4, [fp], #-1550 @ 0xfffff9f2 │ │ │ │ ldrdne pc, [r8], r0 @ │ │ │ │ @ instruction: 0xf7eb6818 │ │ │ │ @ instruction: 0xf8d0fd3f │ │ │ │ @ instruction: 0x46045278 │ │ │ │ suble r2, r0, r0, lsl #26 │ │ │ │ addsmi r6, lr, #2818048 @ 0x2b0000 │ │ │ │ andcs sp, r1, #46 @ 0x2e │ │ │ │ ldrtmi r4, [r1], -r0, lsr #12 │ │ │ │ stc2l 7, cr15, [r4], {253} @ 0xfd │ │ │ │ - vldr d4, [pc, #184] @ 29c88 │ │ │ │ + vldr d4, [pc, #184] @ 29c10 │ │ │ │ ldrbtmi r1, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ rsbsmi pc, r8, #212, 16 @ 0xd40000 │ │ │ │ - blhi 1e5228 <__bss_end__@@Base+0x13e5f0> │ │ │ │ + blhi 1e51b0 <__bss_end__@@Base+0x13e610> │ │ │ │ @ instruction: 0xeeb06a9d │ │ │ │ @ instruction: 0xf7d90b48 │ │ │ │ - ldc 12, cr14, [pc, #1008] @ 29fd8 │ │ │ │ + ldc 13, cr14, [pc, #24] @ 29b88 │ │ │ │ @ instruction: 0xf06f7b25 │ │ │ │ cdp 2, 2, cr4, cr0, cr0, {0} │ │ │ │ vmov.f64 d16, #199 @ 0xbe380000 -0.1796875 │ │ │ │ vnmla.f64 d7, d23, d0 │ │ │ │ addsmi r3, r3, #144, 20 @ 0x90000 │ │ │ │ ldrmi fp, [r3], -r8, lsr #30 │ │ │ │ @ instruction: 0xf043b10d │ │ │ │ - bmi 882808 <__bss_end__@@Base+0x7dbbd0> │ │ │ │ + bmi 882790 <__bss_end__@@Base+0x7dbbf0> │ │ │ │ ldrbtmi r6, [sl], #-355 @ 0xfffffe9d │ │ │ │ - blhi e5220 <__bss_end__@@Base+0x3e5e8> │ │ │ │ + blhi e51a8 <__bss_end__@@Base+0x3e608> │ │ │ │ @ instruction: 0xb12b6813 │ │ │ │ ldrbtmi r4, [fp], #-2846 @ 0xfffff4e2 │ │ │ │ tstlt r8, r8, lsl r9 │ │ │ │ tstlt fp, fp, asr r8 │ │ │ │ - blhi e4f18 <__bss_end__@@Base+0x3e2e0> │ │ │ │ + blhi e4ea0 <__bss_end__@@Base+0x3e300> │ │ │ │ ldcllt 0, cr2, [r0, #-0] │ │ │ │ tstpeq r0, r4, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0xf982f7e4 │ │ │ │ + ldc2l 7, cr15, [r6, #-912]! @ 0xfffffc70 │ │ │ │ ldc 8, cr3, [sp] │ │ │ │ svclt 0x00188b02 │ │ │ │ submi r2, r0, #1 │ │ │ │ ldmdami r5, {r4, r5, r6, r8, sl, fp, ip, sp, pc} │ │ │ │ eorscs r4, r8, #45088768 @ 0x2b00000 │ │ │ │ bicsvc pc, sl, r0, asr #4 │ │ │ │ @ instruction: 0xf7e94478 │ │ │ │ - strtmi pc, [r9], -pc, asr #29 │ │ │ │ + qsub16mi pc, r9, r7 @ │ │ │ │ @ instruction: 0xf8c42238 │ │ │ │ @ instruction: 0xf7d90278 │ │ │ │ - @ instruction: 0xf8d4ea18 │ │ │ │ + @ instruction: 0xf8d4ea2e │ │ │ │ @ instruction: 0xf04f3278 │ │ │ │ @ instruction: 0xf04f30ff │ │ │ │ stmib r3, {r0, r1, r2, r3, r4, r5, r6, r7, r8, ip, sp}^ │ │ │ │ @ instruction: 0xf04f0100 │ │ │ │ @ instruction: 0xe7a633ff │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ ldmvc sl, {r0, r3, r6, r7, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0x41223456 │ │ │ │ - andeq r3, r3, r2, lsl #19 │ │ │ │ - andeq r3, r3, r6, asr r9 │ │ │ │ - andeq r0, r3, lr, ror fp │ │ │ │ - andeq r3, r3, r2, lsl r9 │ │ │ │ - andeq r1, r2, r8, asr r0 │ │ │ │ + andeq r3, r3, r2, ror #18 │ │ │ │ + andeq r3, r3, r6, lsr r9 │ │ │ │ + andeq r0, r3, lr, asr fp │ │ │ │ + strdeq r3, [r3], -r2 │ │ │ │ + muleq r2, r4, r2 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8c8ac <__bss_end__@@Base+0xfeae5c74> │ │ │ │ + bl feb8c834 <__bss_end__@@Base+0xfeae5c94> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi e2dc4c <__bss_end__@@Base+0xd87014> │ │ │ │ + blmi e2dbd4 <__bss_end__@@Base+0xd87034> │ │ │ │ addpl pc, r0, #0, 10 │ │ │ │ ldrbtmi r4, [fp], #-1542 @ 0xfffff9fa │ │ │ │ ldrdne pc, [r8], r2 @ │ │ │ │ @ instruction: 0xf7eb6818 │ │ │ │ @ instruction: 0xf8d0fcb9 │ │ │ │ @ instruction: 0x46045278 │ │ │ │ suble r2, r2, r0, lsl #26 │ │ │ │ @ instruction: 0xf9b6686a │ │ │ │ addsmi r3, r3, #56, 6 @ 0xe0000000 │ │ │ │ stmdavs r9!, {r1, r2, r3, r5, ip, lr, pc} │ │ │ │ strtmi r2, [r0], -r1, lsl #4 │ │ │ │ ldc2 7, cr15, [ip], #-1012 @ 0xfffffc0c │ │ │ │ - vldr d4, [pc, #176] @ 29d90 │ │ │ │ + vldr d4, [pc, #176] @ 29d18 │ │ │ │ ldrbtmi r1, [fp], #-2855 @ 0xfffff4d9 │ │ │ │ rsbsmi pc, r8, #212, 16 @ 0xd40000 │ │ │ │ - blhi 1e5338 <__bss_end__@@Base+0x13e700> │ │ │ │ + blhi 1e52c0 <__bss_end__@@Base+0x13e720> │ │ │ │ @ instruction: 0xeeb06a9d │ │ │ │ @ instruction: 0xf7d90b48 │ │ │ │ - ldc 12, cr14, [pc, #464] @ 29ec8 │ │ │ │ + ldc 12, cr14, [pc, #504] @ 29e78 │ │ │ │ @ instruction: 0xf06f7b23 │ │ │ │ cdp 2, 2, cr4, cr0, cr0, {0} │ │ │ │ vmov.f64 d16, #199 @ 0xbe380000 -0.1796875 │ │ │ │ vnmla.f64 d7, d23, d0 │ │ │ │ addsmi r3, r3, #144, 20 @ 0x90000 │ │ │ │ ldrmi fp, [r3], -r8, lsr #30 │ │ │ │ @ instruction: 0xf043b10d │ │ │ │ - bmi 802918 <__bss_end__@@Base+0x75bce0> │ │ │ │ + bmi 8028a0 <__bss_end__@@Base+0x75bd00> │ │ │ │ ldrbtmi r6, [sl], #-355 @ 0xfffffe9d │ │ │ │ - blhi e5330 <__bss_end__@@Base+0x3e6f8> │ │ │ │ + blhi e52b8 <__bss_end__@@Base+0x3e718> │ │ │ │ @ instruction: 0xb12b6813 │ │ │ │ ldrbtmi r4, [fp], #-2844 @ 0xfffff4e4 │ │ │ │ tstlt r8, r8, lsl r9 │ │ │ │ tstlt fp, fp, asr r8 │ │ │ │ - blhi e5028 <__bss_end__@@Base+0x3e3f0> │ │ │ │ + blhi e4fb0 <__bss_end__@@Base+0x3e410> │ │ │ │ ldcllt 0, cr2, [r0, #-0] │ │ │ │ tstpeq r0, r4, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0xf8faf7e4 │ │ │ │ + stc2l 7, cr15, [lr], #912 @ 0x390 │ │ │ │ ldc 8, cr3, [sp] │ │ │ │ svclt 0x00188b02 │ │ │ │ submi r2, r0, #1 │ │ │ │ ldmdami r3, {r4, r5, r6, r8, sl, fp, ip, sp, pc} │ │ │ │ eorscs r4, r8, #45088768 @ 0x2b00000 │ │ │ │ bicsvc pc, sl, r0, asr #4 │ │ │ │ @ instruction: 0xf7e94478 │ │ │ │ - strtmi pc, [r9], -r7, asr #28 │ │ │ │ + strtmi pc, [r9], -pc, ror #29 │ │ │ │ @ instruction: 0xf8c42238 │ │ │ │ @ instruction: 0xf7d90278 │ │ │ │ - @ instruction: 0xf8d4e990 │ │ │ │ + @ instruction: 0xf8d4e9a6 │ │ │ │ @ instruction: 0xf04f5278 │ │ │ │ @ instruction: 0xf04f32ff │ │ │ │ stmib r5, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, ip, sp}^ │ │ │ │ str r2, [r6, r0, lsl #6]! │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ ldmvc sl, {r0, r3, r6, r7, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0x41223456 │ │ │ │ - andeq r3, r3, r6, ror r8 │ │ │ │ - andeq r3, r3, r6, asr #16 │ │ │ │ - andeq r0, r3, lr, ror #20 │ │ │ │ - andeq r3, r3, r2, lsl #16 │ │ │ │ - andeq r0, r2, r8, asr #30 │ │ │ │ + andeq r3, r3, r6, asr r8 │ │ │ │ + andeq r3, r3, r6, lsr #16 │ │ │ │ + andeq r0, r3, lr, asr #20 │ │ │ │ + andeq r3, r3, r2, ror #15 │ │ │ │ + andeq r1, r2, r4, lsl #3 │ │ │ │ vst3.8 {d27,d29,d31}, [pc], r8 │ │ │ │ - bl feb80fa8 <__bss_end__@@Base+0xfeada370> │ │ │ │ + bl feb80f30 <__bss_end__@@Base+0xfeada390> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - bmi 2add90 <__bss_end__@@Base+0x207158> │ │ │ │ + bmi 2add18 <__bss_end__@@Base+0x207178> │ │ │ │ orrpl pc, r0, #0, 10 │ │ │ │ @ instruction: 0xf8d3447a │ │ │ │ ldmdavs r0, {r3, r5, r7, ip} │ │ │ │ ldc2 7, cr15, [r8], #-940 @ 0xfffffc54 │ │ │ │ rsbscc pc, r8, #208, 16 @ 0xd00000 │ │ │ │ tstlt r3, r8, lsl r6 │ │ │ │ mlaeq r9, r3, r8, pc @ │ │ │ │ @ instruction: 0xbd08b900 │ │ │ │ ldmdavc r8, {r0, r1, r3, r4, r6, r7, r9, fp, sp, lr}^ │ │ │ │ svclt 0x0000bd08 │ │ │ │ - andeq r3, r3, r4, ror r7 │ │ │ │ + andeq r3, r3, r4, asr r7 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb80fe4 <__bss_end__@@Base+0xfeada3ac> │ │ │ │ + bl feb80f6c <__bss_end__@@Base+0xfeada3cc> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ ssub8mi r0, ip, r0 │ │ │ │ @ instruction: 0xf5004b19 │ │ │ │ strmi r5, [lr], -r0, lsl #1 │ │ │ │ @ instruction: 0x4615447b │ │ │ │ ldrdne pc, [r8], r0 @ │ │ │ │ @ instruction: 0xf7eb6818 │ │ │ │ @ instruction: 0xf8d0fc17 │ │ │ │ - bvs ff6f67e8 <__bss_end__@@Base+0xff64fbb0> │ │ │ │ + bvs ff6f6770 <__bss_end__@@Base+0xff64fbd0> │ │ │ │ teqcs r8, #1458176 @ 0x164000 │ │ │ │ tstpne r6, r3, lsl #22 @ p-variant is OBSOLETE │ │ │ │ vldr d9, [r1, #16] │ │ │ │ vldr s6, [r1, #24] │ │ │ │ vldr s8, [r1, #28] │ │ │ │ vmov.f32 s10, #120 @ 0x3fc00000 1.5 │ │ │ │ vldr s6, [r1, #780] @ 0x30c │ │ │ │ @@ -39410,47 +39405,47 @@ │ │ │ │ vldr s8, [r1, #784] @ 0x310 │ │ │ │ vmov.f32 s14, #115 @ 0x3f980000 1.1875000 │ │ │ │ vcvt.f64.f32 d5, s10 │ │ │ │ vstr s12, [r5, #792] @ 0x318 │ │ │ │ vmov.f64 d3, #112 @ 0x3f800000 1.0 │ │ │ │ vstr s14, [r4, #796] @ 0x31c │ │ │ │ vstr d4, [r3] │ │ │ │ - blls 180a48 <__bss_end__@@Base+0xd9e10> │ │ │ │ - blvs 65458 <__bss_start@@Base+0xa3b8> │ │ │ │ + blls 1809d0 <__bss_end__@@Base+0xd9e30> │ │ │ │ + blvs 653e0 <__bss_start@@Base+0xa3d8> │ │ │ │ vstr d9, [r3, #24] │ │ │ │ vldmdblt r0!, {d23-d22} │ │ │ │ - andeq r3, r3, r4, lsr r7 │ │ │ │ + andeq r3, r3, r4, lsl r7 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb81060 <__bss_end__@@Base+0xfeada428> │ │ │ │ + bl feb80fe8 <__bss_end__@@Base+0xfeada448> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - bmi d6dd08 <__bss_end__@@Base+0xcc70d0> │ │ │ │ + bmi d6dc90 <__bss_end__@@Base+0xcc70f0> │ │ │ │ ldcmi 0, cr11, [r5, #-580]! @ 0xfffffdbc │ │ │ │ - blmi d7b6a8 <__bss_end__@@Base+0xcd4a70> │ │ │ │ + blmi d7b630 <__bss_end__@@Base+0xcd4a90> │ │ │ │ ldrbtmi r4, [sp], #-1146 @ 0xfffffb86 │ │ │ │ ldmpl r3, {r0, r9, sl, lr}^ │ │ │ │ ldmdavs fp, {r3, r5, fp, sp, lr} │ │ │ │ @ instruction: 0xf04f930f │ │ │ │ @ instruction: 0xf7eb0300 │ │ │ │ - blmi c68ddc <__bss_end__@@Base+0xbc21a4> │ │ │ │ + blmi c68d64 <__bss_end__@@Base+0xbc21c4> │ │ │ │ ldrbtmi r4, [fp], #-1543 @ 0xfffff9f9 │ │ │ │ @ instruction: 0xb1206818 │ │ │ │ tstlt ip, ip, lsr #18 │ │ │ │ cmnlt r3, fp, ror #16 │ │ │ │ - bmi b31e9c <__bss_end__@@Base+0xa8b264> │ │ │ │ + bmi b31e24 <__bss_end__@@Base+0xa8b284> │ │ │ │ ldrbtmi r4, [sl], #-2857 @ 0xfffff4d7 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, pc, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andslt sp, r1, ip, lsr r1 │ │ │ │ ldc 13, cr11, [r5, #960] @ 0x3c0 │ │ │ │ tstcs r6, #6144 @ 0x1800 │ │ │ │ - blne 765538 <__bss_end__@@Base+0x6be900> │ │ │ │ + blne 7654c0 <__bss_end__@@Base+0x6be920> │ │ │ │ andscc pc, r6, sp, lsl #17 │ │ │ │ @ instruction: 0xf7d96aad │ │ │ │ - vldr d14, [pc, #560] @ 2a0f8 │ │ │ │ + vldr d14, [pc, #600] @ 2a0a8 │ │ │ │ @ instruction: 0xf06f7b1b │ │ │ │ cdp 2, 2, cr4, cr0, cr0, {0} │ │ │ │ vmov.f64 d16, #199 @ 0xbe380000 -0.1796875 │ │ │ │ vnmla.f64 d7, d23, d0 │ │ │ │ addsmi r3, r3, #144, 20 @ 0x90000 │ │ │ │ ldrmi fp, [r3], -r8, lsr #30 │ │ │ │ @ instruction: 0xf043b10d │ │ │ │ @@ -39460,69 +39455,69 @@ │ │ │ │ @ instruction: 0xf8ad4630 │ │ │ │ movwls r1, #24618 @ 0x602a │ │ │ │ @ instruction: 0xf8ad2301 │ │ │ │ movwls r2, #49188 @ 0xc024 │ │ │ │ movwls r4, #58987 @ 0xe66b │ │ │ │ movweq pc, #49731 @ 0xc243 @ │ │ │ │ @ instruction: 0xf7d99300 │ │ │ │ - strmi lr, [r3], -sl, lsl #19 │ │ │ │ + strmi lr, [r3], -r2, lsr #19 │ │ │ │ strtmi sl, [r0], -r5, lsl #18 │ │ │ │ stmib sp, {r0, r1, r3, r4, r6, r7}^ │ │ │ │ @ instruction: 0xf7e43601 │ │ │ │ - stmdacc r0, {r0, r1, r3, fp, ip, sp, lr, pc} │ │ │ │ + stmdacc r0, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ andcs fp, r1, r8, lsl pc │ │ │ │ ldr r4, [r8, r0, asr #4]! │ │ │ │ - b 1267e90 <__bss_end__@@Base+0x11c1258> │ │ │ │ + b 1867e18 <__bss_end__@@Base+0x17c1278> │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ ldmvc sl, {r0, r3, r6, r7, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0x41223456 │ │ │ │ - muleq r2, r0, r1 │ │ │ │ - @ instruction: 0x000336b6 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - strdeq r0, [r3], -lr │ │ │ │ - andeq lr, r2, r2, ror #2 │ │ │ │ + andeq lr, r2, r8, lsl #4 │ │ │ │ + muleq r3, r6, r6 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + ldrdeq r0, [r3], -lr │ │ │ │ + ldrdeq lr, [r2], -sl │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0040f8cc │ │ │ │ @ instruction: 0x46164c56 │ │ │ │ adclt r4, r9, r6, asr sl │ │ │ │ ldrbtmi r4, [ip], #-2902 @ 0xfffff4aa │ │ │ │ @ instruction: 0xf8d4447a │ │ │ │ ldmpl r3, {r4, ip, pc}^ │ │ │ │ @ instruction: 0x9327681b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ svceq 0x0000f1b9 │ │ │ │ addhi pc, ip, r0 │ │ │ │ - blcs 44114 │ │ │ │ + blcs 4409c │ │ │ │ addhi pc, r8, r0, asr #32 │ │ │ │ stmdavs r1, {r0, r1, r2, r3, r9, sl, lr} │ │ │ │ stmdbcs r0, {r0, r2, r9, sl, lr} │ │ │ │ addhi pc, r2, r0, asr #32 │ │ │ │ addscs r4, r8, #232, 12 @ 0xe800000 │ │ │ │ @ instruction: 0xf7d94640 │ │ │ │ - ldc 8, cr14, [r4, #464] @ 0x1d0 │ │ │ │ - vldr d0, [pc, #24] @ 29fc0 │ │ │ │ + ldc 8, cr14, [r4, #552] @ 0x228 │ │ │ │ + vldr d0, [pc, #24] @ 29f48 │ │ │ │ orrscs r1, ip, #66560 @ 0x10400 │ │ │ │ orrvs pc, r4, #12910592 @ 0xc50000 │ │ │ │ orrvc pc, r0, #12910592 @ 0xc50000 │ │ │ │ andcc pc, r2, sp, lsl #17 │ │ │ │ @ instruction: 0xf7d96aa4 │ │ │ │ - vldr d14, [pc, #64] @ 2a000 │ │ │ │ + vldr d14, [pc, #104] @ 29fb0 │ │ │ │ @ instruction: 0xf06f7b3d │ │ │ │ cdp 2, 2, cr4, cr0, cr0, {0} │ │ │ │ vmov.f64 d16, #199 @ 0xbe380000 -0.1796875 │ │ │ │ vnmla.f64 d7, d23, d0 │ │ │ │ addsmi r3, r3, #144, 20 @ 0x90000 │ │ │ │ ldrmi fp, [r3], -r8, lsr #30 │ │ │ │ cmple sl, r0, lsl #24 │ │ │ │ @ instruction: 0xf8df4648 │ │ │ │ movwls r9, #4328 @ 0x10e8 │ │ │ │ - @ instruction: 0xf810f7e4 │ │ │ │ + stc2 7, cr15, [r4], {228} @ 0xe4 │ │ │ │ @ instruction: 0x460744f9 │ │ │ │ strcs r9, [r0], -r6 │ │ │ │ eorcs r4, r0, #3538944 @ 0x360000 │ │ │ │ ldrdcc pc, [ip], -r9 │ │ │ │ @ instruction: 0xf8ad21bc │ │ │ │ ldrbtmi r3, [r8], #-12 │ │ │ │ ldrsbtcc pc, [r0], #-137 @ 0xffffff77 @ │ │ │ │ @@ -39533,82 +39528,82 @@ │ │ │ │ andscc pc, lr, sp, asr #17 │ │ │ │ @ instruction: 0xf8ad8deb │ │ │ │ ldrtmi r3, [r3], -r2, lsr #32 │ │ │ │ andsmi pc, ip, sp, lsr #17 │ │ │ │ andsvs pc, r0, sp, lsr #17 │ │ │ │ andsvs pc, r6, sp, lsr #17 │ │ │ │ @ instruction: 0xf7e99609 │ │ │ │ - @ instruction: 0x4631fcdd │ │ │ │ + ldrtmi pc, [r1], -r5, lsl #27 @ │ │ │ │ strmi r2, [r4], -r0, lsr #4 │ │ │ │ - stmda r6!, {r0, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda ip!, {r0, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrsbtcc pc, [r8], #-137 @ 0xffffff77 @ │ │ │ │ mvnvs r6, r7, rrx │ │ │ │ @ instruction: 0x61a4b103 │ │ │ │ ldrbtmi r4, [fp], #-2849 @ 0xfffff4df │ │ │ │ tstlt sl, #360 @ 0x168 │ │ │ │ @ instruction: 0xeeb14b20 │ │ │ │ strbmi r6, [r1], -r4, lsl #22 │ │ │ │ ldrbtmi r6, [fp], #-165 @ 0xffffff5b │ │ │ │ - blvc 1e56ac <__bss_end__@@Base+0x13ea74> │ │ │ │ + blvc 1e5634 <__bss_end__@@Base+0x13ea94> │ │ │ │ @ instruction: 0x679c6918 │ │ │ │ - blvc 1e5944 <__bss_end__@@Base+0x13ed0c> │ │ │ │ - blvc 16567c <__bss_end__@@Base+0xbea44> │ │ │ │ - @ instruction: 0xff62f7e3 │ │ │ │ + blvc 1e58cc <__bss_end__@@Base+0x13ed2c> │ │ │ │ + blvc 165604 <__bss_end__@@Base+0xbea64> │ │ │ │ + blx 15e7f8a <__bss_end__@@Base+0x15413ea> │ │ │ │ svclt 0x00183800 │ │ │ │ submi r2, r0, #1 │ │ │ │ - blmi 4bc8d8 <__bss_end__@@Base+0x415ca0> │ │ │ │ + blmi 4bc860 <__bss_end__@@Base+0x415cc0> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls a040ec <__bss_end__@@Base+0x95d4b4> │ │ │ │ + blls a04074 <__bss_end__@@Base+0x95d4d4> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, (UNDEF: 58) │ │ │ │ pop {r0, r3, r5, ip, sp, pc} │ │ │ │ @ instruction: 0xf04383f0 │ │ │ │ str r6, [r1, r0, lsl #6]! │ │ │ │ @ instruction: 0xe7d9675c │ │ │ │ rscscc pc, pc, pc, asr #32 │ │ │ │ @ instruction: 0xf7d9e7ea │ │ │ │ - svclt 0x0000e98c │ │ │ │ + svclt 0x0000e9a4 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ adcmi r2, ip, r0 │ │ │ │ ldmvc sl, {r0, r3, r6, r7, r8, r9, fp, lr, pc} │ │ │ │ @ instruction: 0x41223456 │ │ │ │ - @ instruction: 0x000335be │ │ │ │ - muleq r2, r4, r0 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq r3, r3, r0, asr #10 │ │ │ │ - andeq r0, r2, r2, lsr #25 │ │ │ │ - ldrdeq r3, [r3], -lr │ │ │ │ - andeq r3, r3, lr, asr #9 │ │ │ │ - andeq sp, r2, r4, lsl #31 │ │ │ │ + muleq r3, lr, r5 │ │ │ │ + andeq lr, r2, ip, lsl #2 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq r3, r3, r0, lsr #10 │ │ │ │ + ldrdeq r0, [r2], -lr │ │ │ │ + @ instruction: 0x000334be │ │ │ │ + andeq r3, r3, lr, lsr #9 │ │ │ │ + strdeq sp, [r2], -ip │ │ │ │ ldrbtmi r4, [fp], #-2817 @ 0xfffff4ff │ │ │ │ @ instruction: 0x47706cd8 │ │ │ │ - andeq r3, r3, sl, asr #8 │ │ │ │ + andeq r3, r3, sl, lsr #8 │ │ │ │ ldrbtmi r4, [fp], #-2817 @ 0xfffff4ff │ │ │ │ @ instruction: 0x47706d18 │ │ │ │ - andeq r3, r3, lr, lsr r4 │ │ │ │ + andeq r3, r3, lr, lsl r4 │ │ │ │ ldrbtmi r4, [fp], #-2818 @ 0xfffff4fe │ │ │ │ - bleq 6e5748 <__bss_end__@@Base+0x63eb10> │ │ │ │ + bleq 6e56d0 <__bss_end__@@Base+0x63eb30> │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq r3, r3, r2, lsr r4 │ │ │ │ + andeq r3, r3, r2, lsl r4 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb8130c <__bss_end__@@Base+0xfeada6d4> │ │ │ │ + bl feb81294 <__bss_end__@@Base+0xfeada6f4> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ cdpmi 15, 4, cr0, cr10, cr8, {0} │ │ │ │ stclmi 6, cr4, [sl, #-16] │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ adcslt r4, sl, lr, ror r4 │ │ │ │ - bge 354d6c <__bss_end__@@Base+0x2ae134> │ │ │ │ + bge 354cf4 <__bss_end__@@Base+0x2ae154> │ │ │ │ ldrdeq pc, [r8], r0 @ │ │ │ │ ldmdbpl r5!, {r1, r2, r8, fp, sp, pc}^ │ │ │ │ ldrls r6, [r9, #-2093]! @ 0xfffff7d3 │ │ │ │ streq pc, [r0, #-79] @ 0xffffffb1 │ │ │ │ - blx fe968134 <__bss_end__@@Base+0xfe8c14fc> │ │ │ │ + blx fe9680bc <__bss_end__@@Base+0xfe8c151c> │ │ │ │ stmdami r2, {r3, r5, r6, r8, fp, ip, sp, pc}^ │ │ │ │ - bmi 10bb320 <__bss_end__@@Base+0x10146e8> │ │ │ │ + bmi 10bb2a8 <__bss_end__@@Base+0x1014708> │ │ │ │ ldrbtmi r4, [sl], #-2879 @ 0xfffff4c1 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r9, lsr fp │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ eorslt sp, sl, lr, ror #2 │ │ │ │ @ instruction: 0xf104bd70 │ │ │ │ @ instruction: 0xf5040ef0 │ │ │ │ @@ -39618,244 +39613,244 @@ │ │ │ │ @ instruction: 0xf5046b08 │ │ │ │ ldm lr!, {r2, r3, r5, r7, r9, sl, ip, sp, lr} │ │ │ │ stmia ip!, {r0, r1, r2, r3} │ │ │ │ ldc 0, cr0, [sp, #60] @ 0x3c │ │ │ │ ldm lr, {r1, r3, r8, r9, fp, ip, sp, lr} │ │ │ │ stm ip, {r0, r1} │ │ │ │ strtmi r0, [r9], -r3 │ │ │ │ - blpl f65798 <__bss_end__@@Base+0xebeb60> │ │ │ │ - blvs fe579c <__bss_end__@@Base+0xf3eb64> │ │ │ │ + blpl f65720 <__bss_end__@@Base+0xebeb80> │ │ │ │ + blvs fe5724 <__bss_end__@@Base+0xf3eb84> │ │ │ │ rscseq pc, r0, r4, lsl #2 │ │ │ │ - blvc 10657a4 <__bss_end__@@Base+0xfbeb6c> │ │ │ │ - @ instruction: 0xff3ef7e4 │ │ │ │ + blvc 106572c <__bss_end__@@Base+0xfbeb8c> │ │ │ │ + blx ce80b6 <__bss_end__@@Base+0xc41516> │ │ │ │ ldrtmi r4, [r1], -r8, lsr #12 │ │ │ │ - @ instruction: 0xf7e5ad18 │ │ │ │ - ldc 13, cr15, [sp, #36] @ 0x24 │ │ │ │ - vldr d3, [pc, #64] @ 2a1e8 │ │ │ │ + @ instruction: 0xf7e6ad18 │ │ │ │ + ldc 8, cr15, [sp, #1012] @ 0x3f4 │ │ │ │ + vldr d3, [pc, #64] @ 2a170 │ │ │ │ @ instruction: 0xf1047b23 │ │ │ │ ldc 2, cr0, [sp, #800] @ 0x320 │ │ │ │ ldrtmi r5, [r1], -ip, lsl #22 │ │ │ │ - blvs 3e582c <__bss_end__@@Base+0x33ebf4> │ │ │ │ + blvs 3e57b4 <__bss_end__@@Base+0x33ec14> │ │ │ │ cdp 6, 8, cr4, cr5, cr8, {3} │ │ │ │ vdiv.f64 d4, d6, d7 │ │ │ │ vdiv.f64 d5, d3, d7 │ │ │ │ vstr d6, [sp, #28] │ │ │ │ vstr d4, [sp] │ │ │ │ vstr d5, [sp, #8] │ │ │ │ @ instruction: 0xf7e16b04 │ │ │ │ - ldc 8, cr15, [sp, #804] @ 0x324 │ │ │ │ + vldr s30, [sp, #100] @ 0x64 │ │ │ │ @ instruction: 0xf0150b12 │ │ │ │ cdp 14, 11, cr15, cr0, cr9, {0} │ │ │ │ vldr d7, [sp, #256] @ 0x100 │ │ │ │ vstr d0, [r4, #80] @ 0x50 │ │ │ │ @ instruction: 0xf0157b7a │ │ │ │ cdp 14, 11, cr15, cr0, cr11, {1} │ │ │ │ vldr d7, [sp, #256] @ 0x100 │ │ │ │ vstr d0, [r4, #88] @ 0x58 │ │ │ │ @ instruction: 0xf0157b78 │ │ │ │ mrc 14, 5, APSR_nzcv, cr0, cr3, {2} │ │ │ │ vldr d7, [r4, #256] @ 0x100 │ │ │ │ @ instruction: 0x46281b78 │ │ │ │ - bleq 1ee585c <__bss_end__@@Base+0x1e3ec24> │ │ │ │ - blcs 1225cd0 <__bss_end__@@Base+0x117f098> │ │ │ │ - blvc 1de5824 <__bss_end__@@Base+0x1d3ebec> │ │ │ │ - @ instruction: 0xf90cf7e1 │ │ │ │ + bleq 1ee57e4 <__bss_end__@@Base+0x1e3ec44> │ │ │ │ + blcs 1225c58 <__bss_end__@@Base+0x117f0b8> │ │ │ │ + blvc 1de57ac <__bss_end__@@Base+0x1d3ec0c> │ │ │ │ + blx ff5e8124 <__bss_end__@@Base+0xff541584> │ │ │ │ @ instruction: 0xf1042303 │ │ │ │ ldrtmi r0, [r1], -r8, asr #4 │ │ │ │ @ instruction: 0xf7e04628 │ │ │ │ - strtmi pc, [r0], -r1, lsl #28 │ │ │ │ + @ instruction: 0x4620fe3f │ │ │ │ @ instruction: 0xff02f014 │ │ │ │ str r2, [r6, r0] │ │ │ │ - stmia r4, {r0, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - bvs fe0b0bf8 <__bss_end__@@Base+0xfe009fc0> │ │ │ │ + ldm ip, {r0, r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + bvs fe0b0b80 <__bss_end__@@Base+0xfe009fe0> │ │ │ │ svccc 0x00d381da │ │ │ │ - andeq sp, r2, r4, ror #29 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - muleq r2, r8, ip │ │ │ │ - @ instruction: 0x0002debe │ │ │ │ + andeq sp, r2, ip, asr pc │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + ldrdeq r0, [r2], -r4 │ │ │ │ + andeq sp, r2, r6, lsr pc │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi e570c <__bss_end__@@Base+0x3ead4> │ │ │ │ + blhi e5694 <__bss_end__@@Base+0x3eaf4> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ cdpeq 8, 0, cr15, cr0, cr12, {6} │ │ │ │ rscslt r4, r5, sl, ror #22 │ │ │ │ ldrbtmi r4, [fp], #-3178 @ 0xfffff396 │ │ │ │ ldrbtmi r4, [ip], #-2410 @ 0xfffff696 │ │ │ │ vldr s8, [r3, #424] @ 0x1a8 │ │ │ │ ldrbtmi r7, [sl], #-2834 @ 0xfffff4ee │ │ │ │ strmi r5, [r4], -r1, ror #16 │ │ │ │ - blvc ff065d50 <__bss_end__@@Base+0xfefbf118> │ │ │ │ + blvc ff065cd8 <__bss_end__@@Base+0xfefbf138> │ │ │ │ cmnls r3, r9, lsl #16 │ │ │ │ tstpeq r0, pc, asr #32 @ p-variant is OBSOLETE │ │ │ │ - blx 465e4c <__bss_end__@@Base+0x3bf214> │ │ │ │ + blx 465dd4 <__bss_end__@@Base+0x3bf234> │ │ │ │ stmdbmi r4!, {r0, r2, r8, sl, ip, lr, pc}^ │ │ │ │ ldmib r2, {r1, r4, r6, fp, ip, lr}^ │ │ │ │ stmib r3, {r8}^ │ │ │ │ - ldc 1, cr0, [pc, #72] @ 2a2e0 │ │ │ │ + ldc 1, cr0, [pc, #72] @ 2a268 │ │ │ │ vstrge d8, [lr, #-364] @ 0xfffffe94 │ │ │ │ - blpl ce58f0 <__bss_end__@@Base+0xc3ecb8> │ │ │ │ + blpl ce5878 <__bss_end__@@Base+0xc3ecd8> │ │ │ │ strvc pc, [ip, r4, lsl #10]! │ │ │ │ - blvs d658f8 <__bss_end__@@Base+0xcbecc0> │ │ │ │ + blvs d65880 <__bss_end__@@Base+0xcbece0> │ │ │ │ ldc 14, cr10, [r4, #8] │ │ │ │ @ instruction: 0x46397b36 │ │ │ │ - blpl 265b48 <__bss_end__@@Base+0x1bef10> │ │ │ │ + blpl 265ad0 <__bss_end__@@Base+0x1bef30> │ │ │ │ cdp 6, 2, cr4, cr6, cr8, {1} │ │ │ │ @ instruction: 0xf10d6b08 │ │ │ │ @ instruction: 0xee270a98 │ │ │ │ @ instruction: 0xf10d7b08 │ │ │ │ ldmib r4, {r4, r6, fp}^ │ │ │ │ stmib sp, {r2, r3, r4, r5, r8, r9, sp}^ │ │ │ │ ldmib r4, {r2, r4, r8, r9, sp}^ │ │ │ │ stmib sp, {r1, r2, r3, r4, r5, r8, r9, sp}^ │ │ │ │ ldmib r4, {r1, r2, r4, r8, r9, sp}^ │ │ │ │ stmib sp, {r6, r8, r9, sp}^ │ │ │ │ @ instruction: 0x46322318 │ │ │ │ - blpl 3e5918 <__bss_end__@@Base+0x33ece0> │ │ │ │ - blvs 46591c <__bss_end__@@Base+0x3bece4> │ │ │ │ + blpl 3e58a0 <__bss_end__@@Base+0x33ed00> │ │ │ │ + blvs 4658a4 <__bss_end__@@Base+0x3bed04> │ │ │ │ stc 14, cr10, [sp, #200] @ 0xc8 │ │ │ │ @ instruction: 0xf7e17b12 │ │ │ │ - ldmib sp, {r0, r2, r3, r5, r6, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmib sp, {r1, r3, r4, r5, r6, r7, r8, fp, ip, sp, lr, pc}^ │ │ │ │ ldrtmi r2, [r8], -r2, lsl #6 │ │ │ │ tstcs sl, #3358720 @ 0x334000 │ │ │ │ ldmib sp, {r1, r4, r6, r8, r9, sl, fp, sp, pc}^ │ │ │ │ ldrtmi r2, [r9], -r4, lsl #6 │ │ │ │ tstcs ip, #3358720 @ 0x334000 │ │ │ │ stmdbeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ movwcs lr, #27101 @ 0x69dd │ │ │ │ tstcs lr, #3358720 @ 0x334000 │ │ │ │ - ldc2l 7, cr15, [lr], {224} @ 0xe0 │ │ │ │ + ldc2 7, cr15, [r2, #-896] @ 0xfffffc80 │ │ │ │ movwcs r4, #13881 @ 0x3639 │ │ │ │ @ instruction: 0xf1044632 │ │ │ │ svcge 0x00080048 │ │ │ │ - stc2 7, cr15, [r0, #896] @ 0x380 │ │ │ │ - bge a54fd4 <__bss_end__@@Base+0x9ae39c> │ │ │ │ + ldc2 7, cr15, [lr, #896]! @ 0x380 │ │ │ │ + bge a54f5c <__bss_end__@@Base+0x9ae3bc> │ │ │ │ @ instruction: 0x46304651 │ │ │ │ - bleq fec66768 <__bss_end__@@Base+0xfebbfb30> │ │ │ │ - @ instruction: 0xf8f4f7e1 │ │ │ │ + bleq fec666f0 <__bss_end__@@Base+0xfebbfb50> │ │ │ │ + blx 9e8246 <__bss_end__@@Base+0x9416a6> │ │ │ │ cdpvc 5, 0, cr15, cr12, cr4, {0} │ │ │ │ cmncs ip, #212, 18 @ 0x350000 │ │ │ │ @ instruction: 0x232ce9cd │ │ │ │ ldmib r4, {r2, r3, r5, r7, r9, sl, lr}^ │ │ │ │ stmib sp, {r1, r2, r3, r4, r5, r6, r8, r9, sp}^ │ │ │ │ ldmib r4, {r1, r2, r3, r5, r8, r9, sp}^ │ │ │ │ stmib sp, {r7, r8, r9, sp}^ │ │ │ │ ldm lr!, {r4, r5, r8, r9, sp} │ │ │ │ stmia ip!, {r0, r1, r2, r3} │ │ │ │ ldrtmi r0, [sl], -pc │ │ │ │ - blvc 4659d8 <__bss_end__@@Base+0x3beda0> │ │ │ │ - blvs 3e59dc <__bss_end__@@Base+0x33eda4> │ │ │ │ - blvc 265c08 <__bss_end__@@Base+0x1befd0> │ │ │ │ + blvc 465960 <__bss_end__@@Base+0x3bedc0> │ │ │ │ + blvs 3e5964 <__bss_end__@@Base+0x33edc4> │ │ │ │ + blvc 265b90 <__bss_end__@@Base+0x1beff0> │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ - blvs 265c10 <__bss_end__@@Base+0x1befd8> │ │ │ │ + blvs 265b98 <__bss_end__@@Base+0x1beff8> │ │ │ │ stc 6, cr4, [sp, #196] @ 0xc4 │ │ │ │ @ instruction: 0x46287b10 │ │ │ │ - blvc 4e59f8 <__bss_end__@@Base+0x43edc0> │ │ │ │ - blvs 3e59bc <__bss_end__@@Base+0x33ed84> │ │ │ │ - blvc 265c28 <__bss_end__@@Base+0x1beff0> │ │ │ │ - blvc 4e59c4 <__bss_end__@@Base+0x43ed8c> │ │ │ │ - @ instruction: 0xffeaf7e0 │ │ │ │ + blvc 4e5980 <__bss_end__@@Base+0x43ede0> │ │ │ │ + blvs 3e5944 <__bss_end__@@Base+0x33eda4> │ │ │ │ + blvc 265bb0 <__bss_end__@@Base+0x1bf010> │ │ │ │ + blvc 4e594c <__bss_end__@@Base+0x43edac> │ │ │ │ + @ instruction: 0xf93af7e1 │ │ │ │ ldmib sp, {r1, r5, r8, r9, fp, lr}^ │ │ │ │ ldrbtmi r0, [fp], #-264 @ 0xfffffef8 │ │ │ │ - blge 844408 <__bss_end__@@Base+0x79d7d0> │ │ │ │ + blge 844390 <__bss_end__@@Base+0x79d7f0> │ │ │ │ smlabteq r0, r3, r9, lr │ │ │ │ ldrdeq lr, [sl, -sp] │ │ │ │ smlabteq r2, r3, r9, lr │ │ │ │ ldrdeq lr, [ip, -sp] │ │ │ │ smlabteq r4, r3, r9, lr │ │ │ │ - bmi 716860 <__bss_end__@@Base+0x66fc28> │ │ │ │ + bmi 7167e8 <__bss_end__@@Base+0x66fc48> │ │ │ │ ldmdbvs r1, {r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldmdavs r2, {r0, r3, r8, ip, sp, pc}^ │ │ │ │ - bmi 69698c <__bss_end__@@Base+0x5efd54> │ │ │ │ + bmi 696914 <__bss_end__@@Base+0x5efd74> │ │ │ │ ldrbtmi r4, [sl], #-2835 @ 0xfffff4ed │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r3, ror fp │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ rsbslt sp, r5, r1, lsl r1 │ │ │ │ - blhi e56d0 <__bss_end__@@Base+0x3ea98> │ │ │ │ + blhi e5658 <__bss_end__@@Base+0x3eab8> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ strpl pc, [r0], #1284 @ 0x504 │ │ │ │ andlt pc, r4, sp, asr #17 │ │ │ │ andge pc, r0, sp, asr #17 │ │ │ │ strbmi r4, [r1], -sl, asr #12 │ │ │ │ ldrdeq pc, [r8], r4 @ │ │ │ │ - blx ff9683ee <__bss_end__@@Base+0xff8c17b6> │ │ │ │ + blx ff968376 <__bss_end__@@Base+0xff8c17d6> │ │ │ │ @ instruction: 0xf7d8e7e3 │ │ │ │ - svclt 0x0000efe0 │ │ │ │ + svclt 0x0000eff8 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ - bvs fe0b0dc8 <__bss_end__@@Base+0xfe00a190> │ │ │ │ + bvs fe0b0d50 <__bss_end__@@Base+0xfe00a1b0> │ │ │ │ svccc 0x00d381da │ │ │ │ - andeq r0, r3, r2, lsr #10 │ │ │ │ - muleq r2, r6, sp │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq sp, r2, lr, lsl #27 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - andeq r0, r3, lr, ror #7 │ │ │ │ - andeq r3, r3, r0, ror r1 │ │ │ │ - andeq sp, r2, sl, lsr ip │ │ │ │ + andeq r0, r3, r2, lsl #10 │ │ │ │ + andeq sp, r2, lr, lsl #28 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq sp, r2, r6, lsl #28 │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + andeq r0, r3, lr, asr #7 │ │ │ │ + andeq r3, r3, r0, asr r1 │ │ │ │ + @ instruction: 0x0002dcb2 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb81634 <__bss_end__@@Base+0xfeada9fc> │ │ │ │ + bl feb815bc <__bss_end__@@Base+0xfeadaa1c> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ stcmi 15, cr0, [r6], {248} @ 0xf8 │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r6, sl, lr} │ │ │ │ stmdavs r3, {r4, r5, r8, ip, sp, pc} │ │ │ │ @ instruction: 0xf7e96023 │ │ │ │ - stmdavs r0!, {r0, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmdavs r0!, {r0, r3, r5, sl, fp, ip, sp, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ svclt 0x0000bd10 │ │ │ │ - andeq r3, r3, ip, ror #2 │ │ │ │ + andeq r3, r3, ip, asr #2 │ │ │ │ stmiavs r0, {r4, r8, ip, sp, pc}^ │ │ │ │ - bllt 1de8404 <__bss_end__@@Base+0x1d417cc> │ │ │ │ + ldclt 7, cr15, [lr], {233} @ 0xe9 │ │ │ │ svclt 0x00004770 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb8166c <__bss_end__@@Base+0xfeadaa34> │ │ │ │ + bl feb815f4 <__bss_end__@@Base+0xfeadaa54> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ ldmib r0, {r4, r5, r6, r7, r8, r9, sl, fp}^ │ │ │ │ - bne ffab787c <__bss_end__@@Base+0xffa10c44> │ │ │ │ - ble 3faea4 <__bss_end__@@Base+0x35426c> │ │ │ │ + bne ffab7804 <__bss_end__@@Base+0xffa10c64> │ │ │ │ + ble 3fae2c <__bss_end__@@Base+0x35428c> │ │ │ │ @ instruction: 0x46043532 │ │ │ │ - bne ffaaa638 <__bss_end__@@Base+0xffa03a00> │ │ │ │ + bne ffaaa5c0 <__bss_end__@@Base+0xffa03a20> │ │ │ │ stmiavs r2, {r1, r3, r7, r9, lr}^ │ │ │ │ ldmdane sp, {r3, r4, r5, r7, r8, r9, sl, fp, ip, sp, pc}^ │ │ │ │ cmncs sp, r4, lsl #16 │ │ │ │ ldrbtmi r6, [r8], #-165 @ 0xffffff5b │ │ │ │ @ instruction: 0xf7e900eb │ │ │ │ - strhtvs pc, [r0], #189 @ 0xbd @ │ │ │ │ + rscvs pc, r0, r5, ror #24 │ │ │ │ svclt 0x0000bd38 │ │ │ │ - andeq r0, r2, lr, asr r9 │ │ │ │ - blmi 116928 <__bss_end__@@Base+0x6fcf0> │ │ │ │ + muleq r2, sl, fp │ │ │ │ + blmi 1168b0 <__bss_end__@@Base+0x6fd10> │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ andsvs r6, r8, r2 │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq r3, r3, r0, lsl #2 │ │ │ │ + andeq r3, r3, r0, ror #1 │ │ │ │ vst3.8 {d27,d29,d31}, [pc], r8 │ │ │ │ - bl feb816c0 <__bss_end__@@Base+0xfeadaa88> │ │ │ │ + bl feb81648 <__bss_end__@@Base+0xfeadaaa8> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi 3ae4a8 <__bss_end__@@Base+0x307870> │ │ │ │ + blmi 3ae430 <__bss_end__@@Base+0x307890> │ │ │ │ ldmdavs r8, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ stmdavs r2, {r3, r5, r8, ip, sp, pc} │ │ │ │ movwcs r6, #26 │ │ │ │ movwcc lr, #2496 @ 0x9c0 │ │ │ │ stmdami sl, {r3, r8, sl, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf7e94478 │ │ │ │ - blmi 2a9c58 <__bss_end__@@Base+0x203020> │ │ │ │ + blmi 2a9e80 <__bss_end__@@Base+0x2032e0> │ │ │ │ andscs r4, r0, #589824 @ 0x90000 │ │ │ │ cmpcs r3, fp, ror r4 │ │ │ │ @ instruction: 0xf7e94478 │ │ │ │ - movwcs pc, #2685 @ 0xa7d @ │ │ │ │ + movwcs pc, #2853 @ 0xb25 @ │ │ │ │ movwcc lr, #10688 @ 0x29c0 │ │ │ │ stmib r0, {r8, r9, sp}^ │ │ │ │ stclt 3, cr3, [r8, #-0] │ │ │ │ - andeq r3, r3, r0, ror #1 │ │ │ │ + andeq r3, r3, r0, asr #1 │ │ │ │ @ instruction: 0xffffff4d │ │ │ │ @ instruction: 0xffffff6d │ │ │ │ - andeq r0, r2, r4, lsl #18 │ │ │ │ + andeq r0, r2, r0, asr #22 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8d13c <__bss_end__@@Base+0xfeae6504> │ │ │ │ + bl feb8d0c4 <__bss_end__@@Base+0xfeae6524> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ mrc 15, 5, r0, cr0, cr0, {6} │ │ │ │ tstcs r1, r0, asr #22 │ │ │ │ cdp 6, 11, cr4, cr0, cr4, {0} │ │ │ │ vmov.f64 d9, d1 │ │ │ │ vmov.f64 d10, d2 │ │ │ │ @ instruction: 0xf7ff8b43 │ │ │ │ @@ -39863,34 +39858,34 @@ │ │ │ │ andcs r7, r0, #0, 22 │ │ │ │ cdp 8, 3, cr6, cr11, cr0, {3} │ │ │ │ vadd.f64 d11, d9, d7 │ │ │ │ vadd.f64 d9, d10, d7 │ │ │ │ vadd.f64 d10, d8, d7 │ │ │ │ ldrmi r8, [r1], -r7, lsl #22 │ │ │ │ mcrrne 8, 14, r6, r5, cr3 │ │ │ │ - bllt ff326050 <__bss_end__@@Base+0xff27f418> │ │ │ │ - blls ff2a6054 <__bss_end__@@Base+0xff1ff41c> │ │ │ │ - blge ff2e6058 <__bss_end__@@Base+0xff23f420> │ │ │ │ - blhi ff26605c <__bss_end__@@Base+0xff1bf424> │ │ │ │ - bgt 465dd8 <__bss_end__@@Base+0x3bf1a0> │ │ │ │ + bllt ff325fd8 <__bss_end__@@Base+0xff27f438> │ │ │ │ + blls ff2a5fdc <__bss_end__@@Base+0xff1ff43c> │ │ │ │ + blge ff2e5fe0 <__bss_end__@@Base+0xff23f440> │ │ │ │ + blhi ff265fe4 <__bss_end__@@Base+0xff1bf444> │ │ │ │ + bgt 465d60 <__bss_end__@@Base+0x3bf1c0> │ │ │ │ andeq pc, pc, #108, 6 @ 0xb0000001 │ │ │ │ - bgt 465ddc <__bss_end__@@Base+0x3bf1a4> │ │ │ │ + bgt 465d64 <__bss_end__@@Base+0x3bf1c4> │ │ │ │ tstpeq pc, ip, ror #6 @ p-variant is OBSOLETE │ │ │ │ - bgt 465de0 <__bss_end__@@Base+0x3bf1a8> │ │ │ │ + bgt 465d68 <__bss_end__@@Base+0x3bf1c8> │ │ │ │ andsmi pc, pc, #108, 6 @ 0xb0000001 │ │ │ │ eorscs pc, r0, r3, asr #16 │ │ │ │ - bcs 465de8 <__bss_end__@@Base+0x3bf1b0> │ │ │ │ + bcs 465d70 <__bss_end__@@Base+0x3bf1d0> │ │ │ │ biceq lr, r0, #3072 @ 0xc00 │ │ │ │ - blhi 265884 <__bss_end__@@Base+0x1bec4c> │ │ │ │ + blhi 26580c <__bss_end__@@Base+0x1bec6c> │ │ │ │ tstpmi pc, r2, ror #6 @ p-variant is OBSOLETE │ │ │ │ rsbvs r6, r5, r9, asr r0 │ │ │ │ svclt 0x0000bd38 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8d1c8 <__bss_end__@@Base+0xfeae6590> │ │ │ │ + bl feb8d150 <__bss_end__@@Base+0xfeae65b0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ cdp 15, 11, cr0, cr0, cr8, {6} │ │ │ │ tstcs r4, r0, asr #22 │ │ │ │ cdp 6, 11, cr4, cr0, cr4, {0} │ │ │ │ vmov.f64 d9, d1 │ │ │ │ vmov.f64 d10, d2 │ │ │ │ @ instruction: 0xf7ff8b43 │ │ │ │ @@ -39902,24 +39897,24 @@ │ │ │ │ strmi sl, [r1], -r7, asr #22 │ │ │ │ cdp 6, 3, cr4, cr8, cr6, {4} │ │ │ │ strmi r8, [r4], r7, asr #22 │ │ │ │ cdp 8, 11, cr6, cr13, cr6, {7} │ │ │ │ vcvt.s32.f64 s22, d11 │ │ │ │ vcvt.s32.f64 s18, d9 │ │ │ │ vstmdbne pc!, {d10-} │ │ │ │ - blhi ff2660ec <__bss_end__@@Base+0xff1bf4b4> │ │ │ │ + blhi ff266074 <__bss_end__@@Base+0xff1bf4d4> │ │ │ │ sbceq lr, r5, #6144 @ 0x1800 │ │ │ │ - bcc 465e6c <__bss_end__@@Base+0x3bf234> │ │ │ │ + bcc 465df4 <__bss_end__@@Base+0x3bf254> │ │ │ │ vqsub.u32 d27, d3, d11 │ │ │ │ vcgt.f32 d16, d3, d15 │ │ │ │ cdp 1, 1, cr0, cr10, cr15, {0} │ │ │ │ andslt r3, fp, #16, 20 @ 0x10000 │ │ │ │ stceq 3, cr15, [pc], {99} @ 0x63 │ │ │ │ andeq pc, pc, r3, ror #6 │ │ │ │ - bcc 465e80 <__bss_end__@@Base+0x3bf248> │ │ │ │ + bcc 465e08 <__bss_end__@@Base+0x3bf268> │ │ │ │ vqsub.u32 d27, d3, d11 │ │ │ │ vacgt.f32 d20, d3, d15 │ │ │ │ mrc 12, 0, r4, cr8, cr15, {0} │ │ │ │ @ instruction: 0xf8463a10 │ │ │ │ ldc 0, cr14, [sp], #212 @ 0xd4 │ │ │ │ @ instruction: 0xf8c28b08 │ │ │ │ @ instruction: 0xf8c2e01c │ │ │ │ @@ -39928,61 +39923,61 @@ │ │ │ │ andsmi pc, pc, r3, ror #6 │ │ │ │ tstpmi pc, r3, ror #6 @ p-variant is OBSOLETE │ │ │ │ ldrsbvs r6, [r0, -r0] │ │ │ │ orrsvs r6, r1, r1, asr r1 │ │ │ │ ldcllt 0, cr6, [r8, #412]! @ 0x19c │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8d288 <__bss_end__@@Base+0xfeae6650> │ │ │ │ + bl feb8d210 <__bss_end__@@Base+0xfeae6670> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ mrc 15, 5, r0, cr6, cr8, {5} │ │ │ │ vmov.f64 d9, #112 @ 0x3f800000 1.0 │ │ │ │ addlt r6, r4, r0, lsl #22 │ │ │ │ - blhi 2a5f3c <__bss_end__@@Base+0x1ff304> │ │ │ │ - blhi ff1e6148 <__bss_end__@@Base+0xff13f510> │ │ │ │ - blx 466240 <__bss_end__@@Base+0x3bf608> │ │ │ │ - ldc 4, cr13, [pc, #456] @ 2a848 │ │ │ │ + blhi 2a5ec4 <__bss_end__@@Base+0x1ff324> │ │ │ │ + blhi ff1e60d0 <__bss_end__@@Base+0xff13f530> │ │ │ │ + blx 4661c8 <__bss_end__@@Base+0x3bf628> │ │ │ │ + ldc 4, cr13, [pc, #456] @ 2a7d0 │ │ │ │ vmov.s16 r6, d0[2] │ │ │ │ strmi sl, [r5], -r9, lsl #22 │ │ │ │ - blls 2a5f50 <__bss_end__@@Base+0x1ff318> │ │ │ │ - bllt ea5d0c <__bss_end__@@Base+0xdff0d4> │ │ │ │ - bleq 11e5f74 <__bss_end__@@Base+0x113f33c> │ │ │ │ - bleq 266098 <__bss_end__@@Base+0x1bf460> │ │ │ │ - stcl 7, cr15, [lr, #864]! @ 0x360 │ │ │ │ - bleq 65f60 <__bss_start@@Base+0xaec0> │ │ │ │ - bleq 660d0 <__bss_start@@Base+0xb030> │ │ │ │ - svc 0x00a6f7d8 │ │ │ │ - blvc ff0662a0 <__bss_end__@@Base+0xfefbf668> │ │ │ │ + blls 2a5ed8 <__bss_end__@@Base+0x1ff338> │ │ │ │ + bllt ea5c94 <__bss_end__@@Base+0xdff0f4> │ │ │ │ + bleq 11e5efc <__bss_end__@@Base+0x113f35c> │ │ │ │ + bleq 266020 <__bss_end__@@Base+0x1bf480> │ │ │ │ + mcr 7, 0, pc, cr6, cr8, {6} @ │ │ │ │ + bleq 65ee8 <__bss_start@@Base+0xaee0> │ │ │ │ + bleq 66058 <__bss_start@@Base+0xb050> │ │ │ │ + svc 0x00b0f7d8 │ │ │ │ + blvc ff066228 <__bss_end__@@Base+0xfefbf688> │ │ │ │ stmdage r2, {r0, r3, r5, r6, r9, sl, lr} │ │ │ │ - bmi fe465f10 <__bss_end__@@Base+0xfe3bf2d8> │ │ │ │ + bmi fe465e98 <__bss_end__@@Base+0xfe3bf2f8> │ │ │ │ svclt 0x00b82c04 │ │ │ │ strcc r2, [r3], #-1028 @ 0xfffffbfc │ │ │ │ - bmi fe465edc <__bss_end__@@Base+0xfe3bf2a4> │ │ │ │ - bleq ffa261a4 <__bss_end__@@Base+0xff97f56c> │ │ │ │ - bleq 660f4 <__bss_start@@Base+0xb054> │ │ │ │ - ldcl 7, cr15, [r6], {216} @ 0xd8 │ │ │ │ - blvc b25d4c <__bss_end__@@Base+0xa7f114> │ │ │ │ + bmi fe465e64 <__bss_end__@@Base+0xfe3bf2c4> │ │ │ │ + bleq ffa2612c <__bss_end__@@Base+0xff97f58c> │ │ │ │ + bleq 6607c <__bss_start@@Base+0xb074> │ │ │ │ + stcl 7, cr15, [ip], #864 @ 0x360 │ │ │ │ + blvc b25cd4 <__bss_end__@@Base+0xa7f134> │ │ │ │ strtmi r4, [r1], -r8, lsr #12 │ │ │ │ - blgt 65d4c <__bss_start@@Base+0xacac> │ │ │ │ - blhi 225f7c <__bss_end__@@Base+0x17f344> │ │ │ │ - bllt e5d54 <__bss_end__@@Base+0x3f11c> │ │ │ │ + blgt 65cd4 <__bss_start@@Base+0xaccc> │ │ │ │ + blhi 225f04 <__bss_end__@@Base+0x17f364> │ │ │ │ + bllt e5cdc <__bss_end__@@Base+0x3f13c> │ │ │ │ mcr2 7, 6, pc, cr0, cr15, {7} @ │ │ │ │ stmiavs sl!, {r1, r2, r3, r5, r6, fp, sp, lr}^ │ │ │ │ cdp 6, 11, cr4, cr0, cr0, {1} │ │ │ │ - bl c1410 <__bss_end__@@Base+0x1a7d8> │ │ │ │ + bl c1398 <__bss_end__@@Base+0x1a7f8> │ │ │ │ cdp 2, 2, cr0, cr11, cr6, {6} │ │ │ │ vadd.f64 d4, d10, d5 │ │ │ │ vmov.f64 d7, #8 @ 0x40400000 3.0 │ │ │ │ vnmul.f64 d6, d11, d5 │ │ │ │ vmla.f64 d3, d12, d8 │ │ │ │ movwcs r3, #2821 @ 0xb05 │ │ │ │ andcc r4, r8, #26214400 @ 0x1900000 │ │ │ │ - blmi 265f80 <__bss_end__@@Base+0x1bf348> │ │ │ │ - blvc ff226208 <__bss_end__@@Base+0xff17f5d0> │ │ │ │ - blvs 1e5ffc <__bss_end__@@Base+0x13f3c4> │ │ │ │ + blmi 265f08 <__bss_end__@@Base+0x1bf368> │ │ │ │ + blvc ff226190 <__bss_end__@@Base+0xff17f5f0> │ │ │ │ + blvs 1e5f84 <__bss_end__@@Base+0x13f3e4> │ │ │ │ cdp 8, 1, cr3, cr7, cr1, {0} │ │ │ │ @ instruction: 0xeebdca10 │ │ │ │ vabs.f64 d6, d6 │ │ │ │ vmov.f64 d5, d3 │ │ │ │ vsub.f64 d8, d9, d4 │ │ │ │ vqrdmulh.s32 d20, d12, d3 │ │ │ │ cdp 3, 1, cr0, cr6, cr15, {0} │ │ │ │ @@ -40002,75 +39997,75 @@ │ │ │ │ vldmdblt r0!, {d24-d28} │ │ │ │ strbtvs r6, [r6], -r6, ror #12 │ │ │ │ svccc 0x00e66666 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ @ instruction: 0x401921fb │ │ │ │ ldrbvs r2, [ip, #2015] @ 0x7df │ │ │ │ svccc 0x00e6a09e │ │ │ │ - blvc 66264 <__bss_start@@Base+0xb1c4> │ │ │ │ - blcs ff22625c <__bss_end__@@Base+0xff17f624> │ │ │ │ - blx 466354 <__bss_end__@@Base+0x3bf71c> │ │ │ │ + blvc 661ec <__bss_start@@Base+0xb1e4> │ │ │ │ + blcs ff2261e4 <__bss_end__@@Base+0xff17f644> │ │ │ │ + blx 4662dc <__bss_end__@@Base+0x3bf73c> │ │ │ │ adchi pc, r5, r0, lsl #2 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8d3d8 <__bss_end__@@Base+0xfeae67a0> │ │ │ │ + bl feb8d360 <__bss_end__@@Base+0xfeae67c0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ cdp 15, 11, cr0, cr4, cr8, {5} │ │ │ │ vabs.f64 d3, d4 │ │ │ │ vmov.f64 d14, d2 │ │ │ │ vmov.f64 d11, d0 │ │ │ │ vmov.f64 d10, d1 │ │ │ │ vmov.f64 d13, d3 │ │ │ │ addlt ip, r4, r4, asr #22 │ │ │ │ cdp 6, 15, cr4, cr1, cr5, {0} │ │ │ │ vpmin.u8 d31, d0, d0 │ │ │ │ strbtmi r8, [lr], -r1, lsl #1 │ │ │ │ ldrtmi sl, [r1], -r2, lsl #24 │ │ │ │ cdp 6, 11, cr4, cr0, cr0, {1} │ │ │ │ @ instruction: 0xf7d80b4c │ │ │ │ - ldc 12, cr14, [pc, #320] @ 2a91c │ │ │ │ + ldc 12, cr14, [pc, #408] @ 2a8fc │ │ │ │ vrintr.f64 d0, d4 │ │ │ │ vldr d7, [sp] │ │ │ │ vldr d9, [sp] │ │ │ │ vadd.f64 d8, d14, d2 │ │ │ │ vsub.f64 d0, d11, d0 │ │ │ │ vadd.f64 d11, d10, d7 │ │ │ │ vdiv.f64 d10, d0, d7 │ │ │ │ @ instruction: 0xf7d80b0e │ │ │ │ - mrc 13, 1, lr, cr13, cr14, {1} │ │ │ │ + mrc 13, 1, lr, cr13, cr6, {2} │ │ │ │ vsub.f64 d12, d0, d12 │ │ │ │ vdiv.f64 d0, d12, d0 │ │ │ │ @ instruction: 0xf7d80b00 │ │ │ │ - mrc 14, 5, lr, cr13, cr4, {7} │ │ │ │ + mrc 14, 5, lr, cr13, cr14, {7} │ │ │ │ strtmi r0, [r0], -r0, asr #23 │ │ │ │ mrc 6, 0, r4, cr0, cr1, {1} │ │ │ │ @ instruction: 0x2c014a10 │ │ │ │ strcs fp, [r1], #-4024 @ 0xfffff048 │ │ │ │ - bmi fe466040 <__bss_end__@@Base+0xfe3bf408> │ │ │ │ - bleq ffa26308 <__bss_end__@@Base+0xff97f6d0> │ │ │ │ - bleq 6625c <__bss_start@@Base+0xb1bc> │ │ │ │ - stc 7, cr15, [r4], #-864 @ 0xfffffca0 │ │ │ │ + bmi fe465fc8 <__bss_end__@@Base+0xfe3bf428> │ │ │ │ + bleq ffa26290 <__bss_end__@@Base+0xff97f6f0> │ │ │ │ + bleq 661e4 <__bss_start@@Base+0xb1dc> │ │ │ │ + ldc 7, cr15, [sl], #-864 @ 0xfffffca0 │ │ │ │ strtmi r4, [r1], -r8, lsr #12 │ │ │ │ - blle 65eac <__bss_start@@Base+0xae0c> │ │ │ │ - blgt e5eb0 <__bss_end__@@Base+0x3f278> │ │ │ │ + blle 65e34 <__bss_start@@Base+0xae2c> │ │ │ │ + blgt e5e38 <__bss_end__@@Base+0x3f298> │ │ │ │ mrc2 7, 0, pc, cr2, cr15, {7} │ │ │ │ cdp 8, 2, cr6, cr9, cr14, {3} │ │ │ │ stmiavs sl!, {r1, r2, r3, r8, r9, fp, ip, pc}^ │ │ │ │ - blhi 3e60ec <__bss_end__@@Base+0x33f4b4> │ │ │ │ - bl bc0d0 <__bss_end__@@Base+0x15498> │ │ │ │ + blhi 3e6074 <__bss_end__@@Base+0x33f4d4> │ │ │ │ + bl bc058 <__bss_end__@@Base+0x154b8> │ │ │ │ cdp 2, 2, cr0, cr12, cr6, {6} │ │ │ │ vadd.f64 d5, d11, d8 │ │ │ │ vmov.f64 d7, #9 @ 0x40480000 3.125 │ │ │ │ vnmul.f64 d6, d12, d8 │ │ │ │ vmla.f64 d4, d13, d9 │ │ │ │ movwcs r4, #2824 @ 0xb08 │ │ │ │ andcc r4, r8, #26214400 @ 0x1900000 │ │ │ │ - blpl 2a60e4 <__bss_end__@@Base+0x1ff4ac> │ │ │ │ - blvc ff226368 <__bss_end__@@Base+0xff17f730> │ │ │ │ - blvs 1e6160 <__bss_end__@@Base+0x13f528> │ │ │ │ + blpl 2a606c <__bss_end__@@Base+0x1ff4cc> │ │ │ │ + blvc ff2262f0 <__bss_end__@@Base+0xff17f750> │ │ │ │ + blvs 1e60e8 <__bss_end__@@Base+0x13f548> │ │ │ │ cdp 8, 1, cr3, cr7, cr1, {0} │ │ │ │ @ instruction: 0xeebdca10 │ │ │ │ vabs.f64 d6, d6 │ │ │ │ vmov.f64 d8, d4 │ │ │ │ vsub.f64 d9, d10, d5 │ │ │ │ vqrdmulh.s32 d21, d12, d4 │ │ │ │ cdp 3, 1, cr0, cr6, cr15, {0} │ │ │ │ @@ -40084,116 +40079,116 @@ │ │ │ │ cdp 1, 1, cr0, cr5, cr15, {0} │ │ │ │ vpmin.u32 d19, d3, d0 │ │ │ │ @ instruction: 0xf842411f │ │ │ │ bicle r1, r8, r4, lsl #24 │ │ │ │ rsbvs r4, ip, r4, lsr r4 │ │ │ │ ldc 0, cr11, [sp], #16 │ │ │ │ vldmdblt r0!, {d24-d30} │ │ │ │ - blcc 11663a0 <__bss_end__@@Base+0x10bf768> │ │ │ │ - blx 466498 <__bss_end__@@Base+0x3bf860> │ │ │ │ + blcc 1166328 <__bss_end__@@Base+0x10bf788> │ │ │ │ + blx 466420 <__bss_end__@@Base+0x3bf880> │ │ │ │ andlt sp, r4, r4, lsl #2 │ │ │ │ - blhi 3e5bd0 <__bss_end__@@Base+0x33ef98> │ │ │ │ + blhi 3e5b58 <__bss_end__@@Base+0x33efb8> │ │ │ │ @ instruction: 0x4770bd70 │ │ │ │ - blgt 11263a4 <__bss_end__@@Base+0x107f76c> │ │ │ │ - blle 11663a8 <__bss_end__@@Base+0x10bf770> │ │ │ │ + blgt 112632c <__bss_end__@@Base+0x107f78c> │ │ │ │ + blle 1166330 <__bss_end__@@Base+0x10bf790> │ │ │ │ svclt 0x0000e76f │ │ │ │ strbtvs r6, [r6], -r6, ror #12 │ │ │ │ svccc 0x00e66666 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 3e5db4 <__bss_end__@@Base+0x33f17c> │ │ │ │ + blhi 3e5d3c <__bss_end__@@Base+0x33f19c> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00a0f8cc │ │ │ │ cdp 0, 11, cr11, cr0, cr4, {4} │ │ │ │ strmi r9, [r4], -r0, asr #22 │ │ │ │ - blhi 10a63d4 <__bss_end__@@Base+0xfff79c> │ │ │ │ - bleq 10e63d8 <__bss_end__@@Base+0x103f7a0> │ │ │ │ - blge 11263dc <__bss_end__@@Base+0x107f7a4> │ │ │ │ + blhi 10a635c <__bss_end__@@Base+0xfff7bc> │ │ │ │ + bleq 10e6360 <__bss_end__@@Base+0x103f7c0> │ │ │ │ + blge 1126364 <__bss_end__@@Base+0x107f7c4> │ │ │ │ stmdage r2, {r0, r3, r5, r6, r9, sl, lr} │ │ │ │ - bl feae8884 <__bss_end__@@Base+0xfea41c4c> │ │ │ │ - blcc e5f9c <__bss_end__@@Base+0x3f364> │ │ │ │ - blpl 65fa0 <__bss_start@@Base+0xaf00> │ │ │ │ - blle 12a63f0 <__bss_end__@@Base+0x11ff7b8> │ │ │ │ - blvc 14e5fb0 <__bss_end__@@Base+0x143f378> │ │ │ │ - blgt 12663f8 <__bss_end__@@Base+0x11bf7c0> │ │ │ │ - blvs 14e5fb8 <__bss_end__@@Base+0x143f380> │ │ │ │ - blgt 2e614c <__bss_end__@@Base+0x23f514> │ │ │ │ - blle 2e6158 <__bss_end__@@Base+0x23f520> │ │ │ │ - bllt 12a6408 <__bss_end__@@Base+0x11ff7d0> │ │ │ │ - blmi 2261e0 <__bss_end__@@Base+0x17f5a8> │ │ │ │ - blvc 2261dc <__bss_end__@@Base+0x17f5a4> │ │ │ │ - blpl 1e61e8 <__bss_end__@@Base+0x13f5b0> │ │ │ │ - blvs 1e61e4 <__bss_end__@@Base+0x13f5ac> │ │ │ │ - blcc 1365fd8 <__bss_end__@@Base+0x12bf3a0> │ │ │ │ - bl 66438 <__bss_start@@Base+0xb398> │ │ │ │ + bl ff06880c <__bss_end__@@Base+0xfefc1c6c> │ │ │ │ + blcc e5f24 <__bss_end__@@Base+0x3f384> │ │ │ │ + blpl 65f28 <__bss_start@@Base+0xaf20> │ │ │ │ + blle 12a6378 <__bss_end__@@Base+0x11ff7d8> │ │ │ │ + blvc 14e5f38 <__bss_end__@@Base+0x143f398> │ │ │ │ + blgt 1266380 <__bss_end__@@Base+0x11bf7e0> │ │ │ │ + blvs 14e5f40 <__bss_end__@@Base+0x143f3a0> │ │ │ │ + blgt 2e60d4 <__bss_end__@@Base+0x23f534> │ │ │ │ + blle 2e60e0 <__bss_end__@@Base+0x23f540> │ │ │ │ + bllt 12a6390 <__bss_end__@@Base+0x11ff7f0> │ │ │ │ + blmi 226168 <__bss_end__@@Base+0x17f5c8> │ │ │ │ + blvc 226164 <__bss_end__@@Base+0x17f5c4> │ │ │ │ + blpl 1e6170 <__bss_end__@@Base+0x13f5d0> │ │ │ │ + blvs 1e616c <__bss_end__@@Base+0x13f5cc> │ │ │ │ + blcc 1365f60 <__bss_end__@@Base+0x12bf3c0> │ │ │ │ + bl 663c0 <__bss_start@@Base+0xb3b8> │ │ │ │ tstcs r1, r0, lsr #12 │ │ │ │ - blcc 126210 <__bss_end__@@Base+0x7f5d8> │ │ │ │ - blcs 11e623c <__bss_end__@@Base+0x113f604> │ │ │ │ - blmi 1e6240 <__bss_end__@@Base+0x13f608> │ │ │ │ - blvs 226248 <__bss_end__@@Base+0x17f610> │ │ │ │ - blvc 11a6254 <__bss_end__@@Base+0x10ff61c> │ │ │ │ - blge 126643c <__bss_end__@@Base+0x11bf804> │ │ │ │ - bllt 126188 <__bss_end__@@Base+0x7f550> │ │ │ │ - blls 126194 <__bss_end__@@Base+0x7f55c> │ │ │ │ - blge 1261a0 <__bss_end__@@Base+0x7f568> │ │ │ │ - blhi 1261a8 <__bss_end__@@Base+0x7f570> │ │ │ │ + blcc 126198 <__bss_end__@@Base+0x7f5f8> │ │ │ │ + blcs 11e61c4 <__bss_end__@@Base+0x113f624> │ │ │ │ + blmi 1e61c8 <__bss_end__@@Base+0x13f628> │ │ │ │ + blvs 2261d0 <__bss_end__@@Base+0x17f630> │ │ │ │ + blvc 11a61dc <__bss_end__@@Base+0x10ff63c> │ │ │ │ + blge 12663c4 <__bss_end__@@Base+0x11bf824> │ │ │ │ + bllt 126110 <__bss_end__@@Base+0x7f570> │ │ │ │ + blls 12611c <__bss_end__@@Base+0x7f57c> │ │ │ │ + blge 126128 <__bss_end__@@Base+0x7f588> │ │ │ │ + blhi 126130 <__bss_end__@@Base+0x7f590> │ │ │ │ stc2l 7, cr15, [sl, #-1020]! @ 0xfffffc04 │ │ │ │ - blle 3e6288 <__bss_end__@@Base+0x33f650> │ │ │ │ - blgt 3e6288 <__bss_end__@@Base+0x33f650> │ │ │ │ + blle 3e6210 <__bss_end__@@Base+0x33f670> │ │ │ │ + blgt 3e6210 <__bss_end__@@Base+0x33f670> │ │ │ │ stmdavs r3!, {r9, sp}^ │ │ │ │ ldrmi r6, [r1], -r0, ror #17 │ │ │ │ - blle ff3a6498 <__bss_end__@@Base+0xff2ff860> │ │ │ │ - blgt ff36649c <__bss_end__@@Base+0xff2bf864> │ │ │ │ - bllt 3e6298 <__bss_end__@@Base+0x33f660> │ │ │ │ + blle ff3a6420 <__bss_end__@@Base+0xff2ff880> │ │ │ │ + blgt ff366424 <__bss_end__@@Base+0xff2bf884> │ │ │ │ + bllt 3e6220 <__bss_end__@@Base+0x33f680> │ │ │ │ vstmiaeq r3, {d30-d29} │ │ │ │ - blge 3e629c <__bss_end__@@Base+0x33f664> │ │ │ │ - bllt ff3264ac <__bss_end__@@Base+0xff27f874> │ │ │ │ - bpl 466230 <__bss_end__@@Base+0x3bf5f8> │ │ │ │ - blge ff2e64b4 <__bss_end__@@Base+0xff23f87c> │ │ │ │ + blge 3e6224 <__bss_end__@@Base+0x33f684> │ │ │ │ + bllt ff326434 <__bss_end__@@Base+0xff27f894> │ │ │ │ + bpl 4661b8 <__bss_end__@@Base+0x3bf618> │ │ │ │ + blge ff2e643c <__bss_end__@@Base+0xff23f89c> │ │ │ │ @ instruction: 0xf885fa0f │ │ │ │ - bpl 466234 <__bss_end__@@Base+0x3bf5fc> │ │ │ │ + bpl 4661bc <__bss_end__@@Base+0x3bf61c> │ │ │ │ andeq pc, pc, #104, 6 @ 0xa0000001 │ │ │ │ cdp 2, 1, cr11, cr12, cr14, {1} │ │ │ │ vpmin.u32 d21, d6, d0 │ │ │ │ eorlt r0, pc, #-1073741821 @ 0xc0000003 │ │ │ │ andsmi pc, pc, #-1677721599 @ 0x9c000001 │ │ │ │ eorscs pc, r3, r0, asr #16 │ │ │ │ - bcs 46624c <__bss_end__@@Base+0x3bf614> │ │ │ │ + bcs 4661d4 <__bss_end__@@Base+0x3bf634> │ │ │ │ strtmi r3, [r0], -r1, lsl #6 │ │ │ │ vqsub.u32 d27, d5, d5 │ │ │ │ @ instruction: 0xf8cc411f │ │ │ │ rsbvs r1, r3, r4 │ │ │ │ @ instruction: 0xf7ff2101 │ │ │ │ mrc 13, 1, APSR_nzcv, cr9, cr5, {1} │ │ │ │ tstcs r0, lr, lsl #22 │ │ │ │ stmiavs r2!, {r0, r1, r5, r6, fp, sp, lr}^ │ │ │ │ - blhi 3e62e8 <__bss_end__@@Base+0x33f6b0> │ │ │ │ + blhi 3e6270 <__bss_end__@@Base+0x33f6d0> │ │ │ │ vmax.u32 d20, d8, d8 │ │ │ │ cdp 1, 11, cr0, cr13, cr15, {0} │ │ │ │ @ instruction: 0xf04f9bc9 │ │ │ │ vsub.i32 d16, d7, d0 │ │ │ │ @ instruction: 0xf842411f │ │ │ │ - bl aeaec <__bss_end__@@Base+0x7eb4> │ │ │ │ + bl aea74 <__bss_end__@@Base+0x7ed4> │ │ │ │ mrrcne 1, 12, r0, sl, cr3 │ │ │ │ - blhi ff26651c <__bss_end__@@Base+0xff1bf8e4> │ │ │ │ + blhi ff2664a4 <__bss_end__@@Base+0xff1bf904> │ │ │ │ vmax.u32 q10, q3, │ │ │ │ cdp 8, 1, cr0, cr9, cr15, {0} │ │ │ │ vpmin.u32 d19, d5, d0 │ │ │ │ andslt r4, fp, #2031616 @ 0x1f0000 │ │ │ │ andeq pc, pc, r3, ror #6 │ │ │ │ streq pc, [pc, -r3, ror #6] │ │ │ │ - bcc 4662a4 <__bss_end__@@Base+0x3bf66c> │ │ │ │ + bcc 46622c <__bss_end__@@Base+0x3bf68c> │ │ │ │ vqsub.u32 d27, d3, d11 │ │ │ │ subvs r4, r8, pc, lsl r0 │ │ │ │ tstcs r1, r2, rrx │ │ │ │ vmax.u32 d20, d3, d16 │ │ │ │ @ instruction: 0xf7ff471f │ │ │ │ stmdavs r3!, {r0, r2, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf84268e2 │ │ │ │ - bl cab30 <__bss_end__@@Base+0x23ef8> │ │ │ │ + bl caab8 <__bss_end__@@Base+0x23f18> │ │ │ │ movwcc r0, #4803 @ 0x12c3 │ │ │ │ rsbvs r6, r3, r7, asr r0 │ │ │ │ ldc 0, cr11, [sp], #16 │ │ │ │ pop {r1, r2, r3, r8, r9, fp, pc} │ │ │ │ svclt 0x000081f0 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ stclt 3, cr10, [r1], {110} @ 0x6e │ │ │ │ @@ -40203,69 +40198,69 @@ │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00c99999 │ │ │ │ ldrmi r4, [r3], -r4, lsl #13 │ │ │ │ @ instruction: 0xf8dc4608 │ │ │ │ stmdblt r2, {r2, sp} │ │ │ │ @ instruction: 0xf8dc4770 │ │ │ │ @ instruction: 0xf7df100c │ │ │ │ - svclt 0x0000b9ef │ │ │ │ + svclt 0x0000b98f │ │ │ │ ldrmi r4, [r3], -r4, lsl #13 │ │ │ │ @ instruction: 0xf8dc4608 │ │ │ │ stmdblt r2, {r2, sp} │ │ │ │ @ instruction: 0xf8dc4770 │ │ │ │ @ instruction: 0xf7df100c │ │ │ │ - svclt 0x0000b9e3 │ │ │ │ + svclt 0x0000b983 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 265f84 <__bss_end__@@Base+0x1bf34c> │ │ │ │ + blhi 265f0c <__bss_end__@@Base+0x1bf36c> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00b8f8cc │ │ │ │ - blge 665b4 <__bss_start@@Base+0xb514> │ │ │ │ + blge 6653c <__bss_start@@Base+0xb534> │ │ │ │ strmi fp, [lr], -r4, lsl #1 │ │ │ │ - blhi 10665a4 <__bss_end__@@Base+0xfbf96c> │ │ │ │ - blcs 2e63b0 <__bss_end__@@Base+0x23f778> │ │ │ │ - blls 10a65ac <__bss_end__@@Base+0xfff974> │ │ │ │ + blhi 106652c <__bss_end__@@Base+0xfbf98c> │ │ │ │ + blcs 2e6338 <__bss_end__@@Base+0x23f798> │ │ │ │ + blls 10a6534 <__bss_end__@@Base+0xfff994> │ │ │ │ pkhbtmi r4, r0, r7, lsl #12 │ │ │ │ - bllt ff0e65e8 <__bss_end__@@Base+0xff03f9b0> │ │ │ │ - bne 466364 <__bss_end__@@Base+0x3bf72c> │ │ │ │ - @ instruction: 0xf9caf7df │ │ │ │ + bllt ff0e6570 <__bss_end__@@Base+0xff03f9d0> │ │ │ │ + bne 4662ec <__bss_end__@@Base+0x3bf74c> │ │ │ │ + @ instruction: 0xf96af7df │ │ │ │ ldrtmi r4, [r0], -r4, lsl #12 │ │ │ │ - bl fe3e8a64 <__bss_end__@@Base+0xfe341e2c> │ │ │ │ - blvc ff3265e8 <__bss_end__@@Base+0xff27f9b0> │ │ │ │ + bl fe9e89ec <__bss_end__@@Base+0xfe941e4c> │ │ │ │ + blvc ff326570 <__bss_end__@@Base+0xff27f9d0> │ │ │ │ ldrtmi r4, [r3], -r5, lsl #12 │ │ │ │ strls r4, [r2, -r0, asr #12] │ │ │ │ - blx 18ff16 <__bss_end__@@Base+0xe92de> │ │ │ │ + blx 18fe9e <__bss_end__@@Base+0xe92fe> │ │ │ │ cdp 4, 0, cr15, cr7, cr4, {0} │ │ │ │ vmla.f64 d9, d7, d10 │ │ │ │ vstr s8, [sp, #576] @ 0x240 │ │ │ │ vmov.f32 s22, #129 @ 0xc0080000 -2.125 │ │ │ │ vmls.f64 d7, d23, d23 │ │ │ │ vsub.f64 d8, d9, d10 │ │ │ │ vmov.f64 d25, #218 @ 0xbed00000 -0.4062500 │ │ │ │ vsub.f64 d7, d24, d9 │ │ │ │ vnmls.f64 d8, d7, d10 │ │ │ │ @ instruction: 0xeefd2a90 │ │ │ │ vnmla.f64 d7, d23, d8 │ │ │ │ @ instruction: 0xf7df1a90 │ │ │ │ - @ instruction: 0xb004f9bb │ │ │ │ - blhi 265e40 <__bss_end__@@Base+0x1bf208> │ │ │ │ + andlt pc, r4, fp, asr r9 @ │ │ │ │ + blhi 265dc8 <__bss_end__@@Base+0x1bf228> │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ andeq r0, r0, r0 │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [r0, -r0] │ │ │ │ ldmvs sl, {r0, r1, r3, r5, r8, ip, sp, pc}^ │ │ │ │ svclt 0x00c42a00 │ │ │ │ rscscc pc, pc, #-2147483648 @ 0x80000000 │ │ │ │ @ instruction: 0x477060da │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 1e602c <__bss_end__@@Base+0x13f3f4> │ │ │ │ + blhi 1e5fb4 <__bss_end__@@Base+0x13f414> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00b0f8cc │ │ │ │ - blvc fec66200 <__bss_end__@@Base+0xfebbf5c8> │ │ │ │ + blvc fec66188 <__bss_end__@@Base+0xfebbf5e8> │ │ │ │ ldc 0, cr11, [r0, #544] @ 0x220 │ │ │ │ strmi r6, [r4], -r6, asr #22 │ │ │ │ strmi r4, [sp], -r5, asr #21 │ │ │ │ vcmpe.f64 d4, d5 │ │ │ │ ldrbtmi r6, [sl], #-3015 @ 0xfffff439 │ │ │ │ ldmpl r3, {r2, r6, r7, r9, sl, fp, lr}^ │ │ │ │ mrc 4, 7, r4, cr1, cr14, {3} │ │ │ │ @@ -40281,167 +40276,167 @@ │ │ │ │ vldr d10, [r4, #296] @ 0x128 │ │ │ │ vldr d7, [r5, #552] @ 0x228 │ │ │ │ vadd.f64 d0, d9, d2 │ │ │ │ vmov.f64 d9, #5 @ 0x40280000 2.625 │ │ │ │ vsub.f64 d1, d9, d10 │ │ │ │ vmul.f64 d9, d9, d6 │ │ │ │ @ instruction: 0xf7d89b07 │ │ │ │ - blmi fed25c0c <__bss_end__@@Base+0xfec7efd4> │ │ │ │ - blhi 10666a8 <__bss_end__@@Base+0xfbfa70> │ │ │ │ - blvc 1c66248 <__bss_end__@@Base+0x1bbf610> │ │ │ │ + blmi fed25bd4 <__bss_end__@@Base+0xfec7f034> │ │ │ │ + blhi 1066630 <__bss_end__@@Base+0xfbfa90> │ │ │ │ + blvc 1c661d0 <__bss_end__@@Base+0x1bbf630> │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ vmul.f64 d6, d6, d0 │ │ │ │ vcmp.f64 d7, d7 │ │ │ │ vsqrt.f64 d23, d9 │ │ │ │ vldmdble sp!, {s31-s46} │ │ │ │ - blvc 1fe6254 <__bss_end__@@Base+0x1f3f61c> │ │ │ │ - blvc ff0666dc <__bss_end__@@Base+0xfefbfaa4> │ │ │ │ - blx 4667d0 <__bss_end__@@Base+0x3bfb98> │ │ │ │ + blvc 1fe61dc <__bss_end__@@Base+0x1f3f63c> │ │ │ │ + blvc ff066664 <__bss_end__@@Base+0xfefbfac4> │ │ │ │ + blx 466758 <__bss_end__@@Base+0x3bfbb8> │ │ │ │ addhi pc, r7, r0, asr #6 │ │ │ │ - bleq fe3e6290 <__bss_end__@@Base+0xfe33f658> │ │ │ │ - bleq 664b4 <__bss_start@@Base+0xb414> │ │ │ │ + bleq fe3e6218 <__bss_end__@@Base+0xfe33f678> │ │ │ │ + bleq 6643c <__bss_start@@Base+0xb434> │ │ │ │ vadd.f64 d4, d16, d22 │ │ │ │ vldr d0, [r4, #284] @ 0x11c │ │ │ │ vmov.32 r7, d23[1] │ │ │ │ ldmpl r3!, {r8, r9, fp, ip, lr}^ │ │ │ │ - blvs 66278 <__bss_start@@Base+0xb1d8> │ │ │ │ - blvc 11e6430 <__bss_end__@@Base+0x113f7f8> │ │ │ │ - blvc ff1a6704 <__bss_end__@@Base+0xff0ffacc> │ │ │ │ - blx 4667fc <__bss_end__@@Base+0x3bfbc4> │ │ │ │ + blvs 66200 <__bss_start@@Base+0xb1f8> │ │ │ │ + blvc 11e63b8 <__bss_end__@@Base+0x113f818> │ │ │ │ + blvc ff1a668c <__bss_end__@@Base+0xff0ffaec> │ │ │ │ + blx 466784 <__bss_end__@@Base+0x3bfbe4> │ │ │ │ addhi pc, r1, r0, asr #6 │ │ │ │ - blvc 11a6700 <__bss_end__@@Base+0x10ffac8> │ │ │ │ - bleq 6671c <__bss_start@@Base+0xb67c> │ │ │ │ - blpl fe1262c4 <__bss_end__@@Base+0xfe07f68c> │ │ │ │ - blvc fe66625c <__bss_end__@@Base+0xfe5bf624> │ │ │ │ - bleq 664f0 <__bss_start@@Base+0xb450> │ │ │ │ - bleq ff1a6724 <__bss_end__@@Base+0xff0ffaec> │ │ │ │ - blx 46681c <__bss_end__@@Base+0x3bfbe4> │ │ │ │ - ldc 12, cr13, [pc, #400] @ 2adec │ │ │ │ + blvc 11a6688 <__bss_end__@@Base+0x10ffae8> │ │ │ │ + bleq 666a4 <__bss_start@@Base+0xb69c> │ │ │ │ + blpl fe12624c <__bss_end__@@Base+0xfe07f6ac> │ │ │ │ + blvc fe6661e4 <__bss_end__@@Base+0xfe5bf644> │ │ │ │ + bleq 66478 <__bss_start@@Base+0xb470> │ │ │ │ + bleq ff1a66ac <__bss_end__@@Base+0xff0ffb0c> │ │ │ │ + blx 4667a4 <__bss_end__@@Base+0x3bfc04> │ │ │ │ + ldc 12, cr13, [pc, #400] @ 2ad74 │ │ │ │ @ instruction: 0xeeb47b80 │ │ │ │ vneg.f64 d16, d7 │ │ │ │ svclt 0x0048fa10 │ │ │ │ - bleq 122672c <__bss_end__@@Base+0x117faf4> │ │ │ │ - blmi 1f662c0 <__bss_end__@@Base+0x1ebf688> │ │ │ │ - blpl 66750 <__bss_start@@Base+0xb6b0> │ │ │ │ - blvc fe6e62c8 <__bss_end__@@Base+0xfe63f690> │ │ │ │ - bleq 116653c <__bss_end__@@Base+0x10bf904> │ │ │ │ - blvc 11e6480 <__bss_end__@@Base+0x113f848> │ │ │ │ - blvc ff1a6754 <__bss_end__@@Base+0xff0ffb1c> │ │ │ │ - blx 46684c <__bss_end__@@Base+0x3bfc14> │ │ │ │ + bleq 12266b4 <__bss_end__@@Base+0x117fb14> │ │ │ │ + blmi 1f66248 <__bss_end__@@Base+0x1ebf6a8> │ │ │ │ + blpl 666d8 <__bss_start@@Base+0xb6d0> │ │ │ │ + blvc fe6e6250 <__bss_end__@@Base+0xfe63f6b0> │ │ │ │ + bleq 11664c4 <__bss_end__@@Base+0x10bf924> │ │ │ │ + blvc 11e6408 <__bss_end__@@Base+0x113f868> │ │ │ │ + blvc ff1a66dc <__bss_end__@@Base+0xff0ffb3c> │ │ │ │ + blx 4667d4 <__bss_end__@@Base+0x3bfc34> │ │ │ │ cdp 13, 11, cr13, cr0, cr15, {2} │ │ │ │ vldr d7, [r4, #276] @ 0x114 │ │ │ │ andcs r6, r0, #59392 @ 0xe800 │ │ │ │ - blpl 1d26314 <__bss_end__@@Base+0x1c7f6dc> │ │ │ │ + blpl 1d2629c <__bss_end__@@Base+0x1c7f6fc> │ │ │ │ stc 3, cr2, [r4] │ │ │ │ stmib r4, {r1, r3, r4, r7, r8, r9, fp, ip, sp, lr}^ │ │ │ │ mrc 3, 5, r2, cr4, cr14, {4} │ │ │ │ vsqrt.f64 d22, d5 │ │ │ │ ldrble pc, [r2], #-2576 @ 0xfffff5f0 @ │ │ │ │ - blvc 1c2632c <__bss_end__@@Base+0x1b7f6f4> │ │ │ │ - blvs ff226784 <__bss_end__@@Base+0xff17fb4c> │ │ │ │ - blx 46687c <__bss_end__@@Base+0x3bfc44> │ │ │ │ + blvc 1c262b4 <__bss_end__@@Base+0x1b7f714> │ │ │ │ + blvs ff22670c <__bss_end__@@Base+0xff17fb6c> │ │ │ │ + blx 466804 <__bss_end__@@Base+0x3bfc64> │ │ │ │ addhi pc, r8, r0, lsl #2 │ │ │ │ - blvc 1ba633c <__bss_end__@@Base+0x1aff704> │ │ │ │ + blvc 1ba62c4 <__bss_end__@@Base+0x1aff724> │ │ │ │ cdp 6, 11, cr4, cr4, cr0, {1} │ │ │ │ vsqrt.f64 d22, d7 │ │ │ │ svclt 0x004cfa10 │ │ │ │ orrmi pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ movwpl pc, #1103 @ 0x44f @ │ │ │ │ addcc pc, r0, #196, 16 @ 0xc40000 │ │ │ │ @ instruction: 0xf992f015 │ │ │ │ - blmi 1cbd6b8 <__bss_end__@@Base+0x1c16a80> │ │ │ │ + blmi 1cbd640 <__bss_end__@@Base+0x1c16aa0> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 204d50 <__bss_end__@@Base+0x15e118> │ │ │ │ + blls 204cd8 <__bss_end__@@Base+0x15e138> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ andlt r8, r8, r7, lsr #1 │ │ │ │ - blhi 1e5fec <__bss_end__@@Base+0x13f3b4> │ │ │ │ + blhi 1e5f74 <__bss_end__@@Base+0x13f3d4> │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ - blvc 1ce635c <__bss_end__@@Base+0x1c3f724> │ │ │ │ - blvs 22659c <__bss_end__@@Base+0x17f964> │ │ │ │ - blvs ff2a67d8 <__bss_end__@@Base+0xff1ffba0> │ │ │ │ - blx 4668d0 <__bss_end__@@Base+0x3bfc98> │ │ │ │ + blvc 1ce62e4 <__bss_end__@@Base+0x1c3f744> │ │ │ │ + blvs 226524 <__bss_end__@@Base+0x17f984> │ │ │ │ + blvs ff2a6760 <__bss_end__@@Base+0xff1ffbc0> │ │ │ │ + blx 466858 <__bss_end__@@Base+0x3bfcb8> │ │ │ │ ldc 5, cr13, [r4, #248] @ 0xf8 │ │ │ │ vmov.u16 r7, d5[3] │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ @ instruction: 0xf53ffa10 │ │ │ │ - ldc 15, cr10, [pc, #484] @ 2af04 │ │ │ │ + ldc 15, cr10, [pc, #484] @ 2ae8c │ │ │ │ @ instruction: 0xe7790b57 │ │ │ │ - bleq 11a67e8 <__bss_end__@@Base+0x10ffbb0> │ │ │ │ + bleq 11a6770 <__bss_end__@@Base+0x10ffbd0> │ │ │ │ cdp 7, 11, cr14, cr15, cr0, {5} │ │ │ │ vmov.f64 d6, #64 @ 0x3e000000 0.125 │ │ │ │ vneg.f64 d23, d6 │ │ │ │ svclt 0x0048fa10 │ │ │ │ - blvc 11e67fc <__bss_end__@@Base+0x113fbc4> │ │ │ │ + blvc 11e6784 <__bss_end__@@Base+0x113fbe4> │ │ │ │ cdp 7, 11, cr14, cr15, cr7, {5} │ │ │ │ vmov.f64 d5, #64 @ 0x3e000000 0.125 │ │ │ │ vneg.f64 d23, d5 │ │ │ │ svclt 0x0048fa10 │ │ │ │ - blvc 11a6810 <__bss_end__@@Base+0x10ffbd8> │ │ │ │ + blvc 11a6798 <__bss_end__@@Base+0x10ffbf8> │ │ │ │ vst1.16 {d30}, [pc :256], r6 │ │ │ │ strtmi r4, [r0], -r0, lsl #6 │ │ │ │ addcc pc, r0, #196, 16 @ 0xc40000 │ │ │ │ @ instruction: 0xf940f015 │ │ │ │ @ instruction: 0xf100e7bc │ │ │ │ strbtmi r0, [pc], -r8, asr #16 │ │ │ │ @ instruction: 0x4641463a │ │ │ │ @ instruction: 0xf7e04628 │ │ │ │ - vldr s30, [sp, #492] @ 0x1ec │ │ │ │ + vldr d15, [sp, #316] @ 0x13c │ │ │ │ vmov.f64 d7, #84 @ 0x3ea00000 0.3125000 │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ - ble ba95c0 <__bss_end__@@Base+0xb02988> │ │ │ │ + ble ba9548 <__bss_end__@@Base+0xb029a8> │ │ │ │ ldrtmi r4, [r8], -r1, asr #12 │ │ │ │ @ instruction: 0xf7e0462a │ │ │ │ - ldr pc, [r0, -sp, lsr #21] │ │ │ │ - blne 663e4 <__bss_start@@Base+0xb344> │ │ │ │ - blne ff066868 <__bss_end__@@Base+0xfefbfc30> │ │ │ │ - blx 46695c <__bss_end__@@Base+0x3bfd24> │ │ │ │ + ldr pc, [r0, -r1, asr #23] │ │ │ │ + blne 6636c <__bss_start@@Base+0xb364> │ │ │ │ + blne ff0667f0 <__bss_end__@@Base+0xfefbfc50> │ │ │ │ + blx 4668e4 <__bss_end__@@Base+0x3bfd44> │ │ │ │ mrc 5, 5, sp, cr0, cr6, {1} │ │ │ │ - vldr d6, [pc, #768] @ 2b0a0 │ │ │ │ + vldr d6, [pc, #768] @ 2b028 │ │ │ │ vldr d5, [r4, #228] @ 0xe4 │ │ │ │ vmov.u16 r7, d4[3] │ │ │ │ vsqrt.f64 d22, d5 │ │ │ │ @ instruction: 0xdc3ffa10 │ │ │ │ - blmi de6430 <__bss_end__@@Base+0xd3f7f8> │ │ │ │ - bleq e26434 <__bss_end__@@Base+0xd7f7fc> │ │ │ │ - blpl c66438 <__bss_end__@@Base+0xbbf800> │ │ │ │ - blvs ff166890 <__bss_end__@@Base+0xff0bfc58> │ │ │ │ - blx 466988 <__bss_end__@@Base+0x3bfd50> │ │ │ │ + blmi de63b8 <__bss_end__@@Base+0xd3f818> │ │ │ │ + bleq e263bc <__bss_end__@@Base+0xd7f81c> │ │ │ │ + blpl c663c0 <__bss_end__@@Base+0xbbf820> │ │ │ │ + blvs ff166818 <__bss_end__@@Base+0xff0bfc78> │ │ │ │ + blx 466910 <__bss_end__@@Base+0x3bfd70> │ │ │ │ mrc 15, 5, fp, cr0, cr8, {2} │ │ │ │ str r0, [r5, -r5, asr #22]! │ │ │ │ movwmi pc, #1103 @ 0x44f @ │ │ │ │ @ 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#36] @ 2ae48 │ │ │ │ + ldrb pc, [r2], r3, lsl #23 @ │ │ │ │ + bleq 12e6854 <__bss_end__@@Base+0x123fcb4> │ │ │ │ + bl e8cf8 <__bss_end__@@Base+0x42158> │ │ │ │ + blvc 8e6418 <__bss_end__@@Base+0x83f878> │ │ │ │ + bleq 1226660 <__bss_end__@@Base+0x117fac0> │ │ │ │ + bleq ff066878 <__bss_end__@@Base+0xfefbfcd8> │ │ │ │ + blx 46696c <__bss_end__@@Base+0x3bfdcc> │ │ │ │ + ldc 13, cr13, [pc, #36] @ 2add0 │ │ │ │ @ instruction: 0xf7d81b1c │ │ │ │ - @ instruction: 0xed94e904 │ │ │ │ + @ instruction: 0xed94e91a │ │ │ │ @ instruction: 0xe6f37b7e │ │ │ │ - bleq 6664b0 <__bss_end__@@Base+0x5bf878> │ │ │ │ + bleq 666438 <__bss_end__@@Base+0x5bf898> │ │ │ │ ldc 6, cr14, [r4, #960] @ 0x3c0 │ │ │ │ - vldr d7, [pc, #504] @ 2b034 │ │ │ │ + vldr d7, [pc, #504] @ 2afbc │ │ │ │ usat r0, #11, r0, lsl #22 │ │ │ │ - b fef68da4 <__bss_end__@@Base+0xfeec216c> │ │ │ │ + b ff568d2c <__bss_end__@@Base+0xff4c218c> │ │ │ │ @ instruction: 0x5742dcf4 │ │ │ │ adcsmi sp, r1, r2, lsl #24 │ │ │ │ strbtvs r6, [r6], -r6, ror #12 │ │ │ │ svccc 0x00ee6666 │ │ │ │ stmdacc sp!, {r0, r2, r5, r6, r8, r9, ip, sp, lr} │ │ │ │ svccc 0x00e0c152 │ │ │ │ stmdacc sp!, {r0, r2, r5, r6, r8, r9, ip, sp, lr} │ │ │ │ @@ -40453,309 +40448,309 @@ │ │ │ │ ldmdblt r5!, {r0, r2, r3, r5, r6, r7, ip, sp}^ │ │ │ │ strdmi r1, [r5], sp │ │ │ │ ... │ │ │ │ ldcllt 7, cr14, [fp], {174} @ 0xae │ │ │ │ andmi r2, r2, r3, asr #13 │ │ │ │ stcpl 5, cr1, [r1, #676]! @ 0x2a4 │ │ │ │ svccc 0x00ebecde │ │ │ │ - bmi ff9fc0b4 <__bss_end__@@Base+0xff95547c> │ │ │ │ + bmi ff9fc03c <__bss_end__@@Base+0xff95549c> │ │ │ │ svccc 0x00d65718 │ │ │ │ subsge r9, r2, #3648 @ 0xe40 │ │ │ │ svccc 0x00a1df46 │ │ │ │ - andeq sp, r2, sl, ror #8 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq sp, r2, r4, ror #8 │ │ │ │ - andeq pc, r2, ip, ror #23 │ │ │ │ - andeq r0, r0, r0, lsl #5 │ │ │ │ - andeq sp, r2, r0, lsr #6 │ │ │ │ + andeq sp, r2, r2, ror #9 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + ldrdeq sp, [r2], -ip │ │ │ │ + andeq pc, r2, ip, asr #23 │ │ │ │ + andeq r0, r0, r8, ror r2 │ │ │ │ + muleq r2, r8, r3 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r0 │ │ │ │ stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb8dad0 <__bss_end__@@Base+0xfeae6e98> │ │ │ │ + bl feb8da58 <__bss_end__@@Base+0xfeae6eb8> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ mrcmi 15, 1, r0, cr11, cr0, {4} │ │ │ │ orrpl pc, r0, #0, 10 │ │ │ │ @ instruction: 0xf5004604 │ │ │ │ ldmdami r9!, {r2, r3, r5, r7, r8, ip, sp, lr} │ │ │ │ addslt r4, r5, lr, ror r4 │ │ │ │ strbeq pc, [r8, -r4, lsl #2] @ │ │ │ │ strtmi r4, [sl], -sp, ror #12 │ │ │ │ @ instruction: 0xf8d35830 │ │ │ │ stmdavs r0, {r8, sp, lr} │ │ │ │ @ instruction: 0xf04f9013 │ │ │ │ cps #0 │ │ │ │ @ instruction: 0xf7e00010 │ │ │ │ - @ instruction: 0x4628f9b5 │ │ │ │ + strtmi pc, [r8], -r9, lsl #21 │ │ │ │ ldrtmi sl, [r9], -r6, lsl #26 │ │ │ │ @ instruction: 0xf7e0462a │ │ │ │ - bge 369890 <__bss_end__@@Base+0x2c2c58> │ │ │ │ + bge 369e4c <__bss_end__@@Base+0x2c32ac> │ │ │ │ @ instruction: 0xf1044639 │ │ │ │ @ instruction: 0xf7e000c8 │ │ │ │ - @ instruction: 0x4628fa5b │ │ │ │ - mcr2 7, 1, pc, cr2, cr15, {6} @ │ │ │ │ - blvc 3e6594 <__bss_end__@@Base+0x33f95c> │ │ │ │ - blcc 266598 <__bss_end__@@Base+0x1bf960> │ │ │ │ + strtmi pc, [r8], -r8, ror #23 │ │ │ │ + stc2l 7, cr15, [ip, #892]! @ 0x37c │ │ │ │ + blvc 3e651c <__bss_end__@@Base+0x33f97c> │ │ │ │ + blcc 266520 <__bss_end__@@Base+0x1bf980> │ │ │ │ ldc 6, cr4, [sp, #164] @ 0xa4 │ │ │ │ strtmi r4, [r0], -ip, lsl #22 │ │ │ │ - blpl 1e65a4 <__bss_end__@@Base+0x13f96c> │ │ │ │ - blvc 1267d0 <__bss_end__@@Base+0x7fb98> │ │ │ │ - blvs 4665ac <__bss_end__@@Base+0x3bf974> │ │ │ │ - blcs 2e65b0 <__bss_end__@@Base+0x23f978> │ │ │ │ - blvc 1a6750 <__bss_end__@@Base+0xffb18> │ │ │ │ - blvc e675c <__bss_end__@@Base+0x3fb24> │ │ │ │ - blhi 66964 <__bss_start@@Base+0xb8c4> │ │ │ │ + blpl 1e652c <__bss_end__@@Base+0x13f98c> │ │ │ │ + blvc 126758 <__bss_end__@@Base+0x7fbb8> │ │ │ │ + blvs 466534 <__bss_end__@@Base+0x3bf994> │ │ │ │ + blcs 2e6538 <__bss_end__@@Base+0x23f998> │ │ │ │ + blvc 1a66d8 <__bss_end__@@Base+0xffb38> │ │ │ │ + blvc e66e4 <__bss_end__@@Base+0x3fb44> │ │ │ │ + blhi 668ec <__bss_start@@Base+0xb8e4> │ │ │ │ mrc2 7, 0, pc, cr0, cr15, {7} │ │ │ │ - blcs 8521c <__bss_start@@Base+0x2a17c> │ │ │ │ + blcs 851a4 <__bss_start@@Base+0x2a19c> │ │ │ │ mrc 0, 5, sp, cr5, cr4, {0} │ │ │ │ vsqrt.f64 d24, d0 │ │ │ │ svclt 0x004cfa10 │ │ │ │ andcs r2, r0, r1 │ │ │ │ - blmi 5fd7c4 <__bss_end__@@Base+0x556b8c> │ │ │ │ + blmi 5fd74c <__bss_end__@@Base+0x556bac> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 504fd4 <__bss_end__@@Base+0x45e39c> │ │ │ │ + blls 504f5c <__bss_end__@@Base+0x45e3bc> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ tstle r6, r0, lsl #6 │ │ │ │ ldc 0, cr11, [sp], #84 @ 0x54 │ │ │ │ @ instruction: 0xbdf08b02 │ │ │ │ - blvc e665d0 <__bss_end__@@Base+0xdbf998> │ │ │ │ - ldc 0, cr2, [pc] @ 2af84 │ │ │ │ - vldr d5, [pc, #40] @ 2afb0 │ │ │ │ + blvc e66558 <__bss_end__@@Base+0xdbf9b8> │ │ │ │ + ldc 0, cr2, [pc] @ 2af0c │ │ │ │ + vldr d5, [pc, #40] @ 2af38 │ │ │ │ vmul.f64 d6, d7, d11 │ │ │ │ vmul.f64 d7, d7, d5 │ │ │ │ vmov.f64 d7, #70 @ 0x3e300000 0.1718750 │ │ │ │ vsqrt.f64 d23, d8 │ │ │ │ svclt 0x0044fa10 │ │ │ │ adcsvs r2, r3, r2, lsl #6 │ │ │ │ @ instruction: 0xf7d8e7de │ │ │ │ - svclt 0x0000ea0c │ │ │ │ + svclt 0x0000ea24 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ - bvs fe0b1970 <__bss_end__@@Base+0xfe00ad38> │ │ │ │ + bvs fe0b18f8 <__bss_end__@@Base+0xfe00ad58> │ │ │ │ svccc 0x00d381da │ │ │ │ bicge ip, sl, r3, lsl #1 │ │ │ │ svccc 0x00ebb645 │ │ │ │ - andeq sp, r2, r4, lsr #2 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - muleq r2, ip, r0 │ │ │ │ + muleq r2, ip, r1 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq sp, r2, r4, lsl r1 │ │ │ │ stmlt r8, {r0, r1, r4, ip, sp, lr, pc} │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi e648c <__bss_end__@@Base+0x3f854> │ │ │ │ + blhi e6414 <__bss_end__@@Base+0x3f874> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00a8f8cc │ │ │ │ addlt r4, fp, sl, asr #20 │ │ │ │ ldrbtmi r4, [sl], #-2890 @ 0xfffff4b6 │ │ │ │ - ldrbtmi r4, [pc], #-3914 @ 2afec │ │ │ │ + ldrbtmi r4, [pc], #-3914 @ 2af74 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9309 │ │ │ │ stmdbvs r3, {r8, r9} │ │ │ │ andle r2, lr, r8, lsl #22 │ │ │ │ - blmi 113d918 <__bss_end__@@Base+0x1096ce0> │ │ │ │ + blmi 113d8a0 <__bss_end__@@Base+0x1096d00> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 285070 <__bss_end__@@Base+0x1de438> │ │ │ │ + blls 284ff8 <__bss_end__@@Base+0x1de458> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ cmnle r1, r0, lsl #6 │ │ │ │ ldc 0, cr11, [sp], #44 @ 0x2c │ │ │ │ pop {r1, r8, r9, fp, pc} │ │ │ │ stmiavs r3, {r4, r5, r6, r7, r8, r9, sl, fp, pc}^ │ │ │ │ ldrbeq r4, [sl, #1540] @ 0x604 │ │ │ │ - blmi fe07d4 <__bss_end__@@Base+0xf39b9c> │ │ │ │ + blmi fe075c <__bss_end__@@Base+0xf39bbc> │ │ │ │ ldmpl fp!, {r1, r2, r3, r9, sl, lr}^ │ │ │ │ - blhi 66678 <__bss_start@@Base+0xb5d8> │ │ │ │ - blhi ff066b04 <__bss_end__@@Base+0xfefbfecc> │ │ │ │ - blx 466bf8 <__bss_end__@@Base+0x3bffc0> │ │ │ │ + blhi 66600 <__bss_start@@Base+0xb5f8> │ │ │ │ + blhi ff066a8c <__bss_end__@@Base+0xfefbfeec> │ │ │ │ + blx 466b80 <__bss_end__@@Base+0x3bffe0> │ │ │ │ @ instruction: 0xf8d0d80b │ │ │ │ - ldc 3, cr3, [pc, #176] @ 2b0ec │ │ │ │ - vldr d6, [pc, #192] @ 2b100 │ │ │ │ + ldc 3, cr3, [pc, #176] @ 2b074 │ │ │ │ + vldr d6, [pc, #192] @ 2b088 │ │ │ │ vldr d7, [r3, #196] @ 0xc4 │ │ │ │ vnmul.f64 d8, d24, d12 │ │ │ │ vmul.f64 d8, d8, d6 │ │ │ │ - blmi d4dc6c <__bss_end__@@Base+0xca7034> │ │ │ │ - blvc fe8a8190 <__bss_end__@@Base+0xfe801558> │ │ │ │ - beq 26748c <__bss_end__@@Base+0x1c0854> │ │ │ │ + blmi d4dbf4 <__bss_end__@@Base+0xca7054> │ │ │ │ + blvc fe8a8118 <__bss_end__@@Base+0xfe801578> │ │ │ │ + beq 267414 <__bss_end__@@Base+0x1c0874> │ │ │ │ ldmibeq r0!, {r2, r8, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf50358fb │ │ │ │ @ instruction: 0xf103380a │ │ │ │ @ instruction: 0xf10805f0 │ │ │ │ @ instruction: 0xf85508f0 │ │ │ │ stmdavs r3!, {r4, r5, r6, r7, sl, fp, sp} │ │ │ │ mlasle r2, sl, r2, r4 │ │ │ │ @ instruction: 0xf8556b62 │ │ │ │ addsmi r3, sl, #188, 24 @ 0xbc00 │ │ │ │ @ instruction: 0xf855d02d │ │ │ │ - blcs 23a404 <__bss_end__@@Base+0x1937cc> │ │ │ │ - blx b2112c <__bss_end__@@Base+0xa7a4f4> │ │ │ │ + blcs 23a38c <__bss_end__@@Base+0x1937ec> │ │ │ │ + blx b210b4 <__bss_end__@@Base+0xa7a514> │ │ │ │ ldrbeq pc, [fp, r3, lsl #6] @ │ │ │ │ ldrbmi sp, [r2], -r5, lsr #10 │ │ │ │ strtmi r4, [r8], -r9, asr #12 │ │ │ │ - stc2 7, cr15, [r2, #892] @ 0x37c │ │ │ │ + stc2 7, cr15, [r0, #892] @ 0x37c │ │ │ │ @ instruction: 0xf7df4650 │ │ │ │ - cdp 13, 11, cr15, cr4, cr1, {3} │ │ │ │ + cdp 13, 11, cr15, cr4, cr11, {1} │ │ │ │ vsqrt.f64 d16, d8 │ │ │ │ ldmdale r8, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ strpl pc, [r0], #1284 @ 0x504 │ │ │ │ ldrdpl pc, [r0, -r4] │ │ │ │ ldm r9!, {r0, r2, r3, r4, r5, r8, ip, sp, pc} │ │ │ │ ldrcc r0, [r0, #-15] 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<__bss_end__@@Base+0xfe00aeb0> │ │ │ │ svccc 0x00d381da │ │ │ │ - andeq sp, r2, sl, lsl r0 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq sp, r2, r6, lsl r0 │ │ │ │ - andeq sp, r2, r0 │ │ │ │ - andeq r0, r0, r4, ror r2 │ │ │ │ - andeq r0, r0, r0, lsr #5 │ │ │ │ - andeq r0, r0, r4, lsr #6 │ │ │ │ + muleq r2, r2, r0 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq sp, r2, lr, lsl #1 │ │ │ │ + andeq sp, r2, r8, ror r0 │ │ │ │ + andeq r0, r0, ip, ror #4 │ │ │ │ + muleq r0, r8, r2 │ │ │ │ + andeq r0, r0, ip, lsl r3 │ │ │ │ @ instruction: 0xfffffedd │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi e65ec <__bss_end__@@Base+0x3f9b4> │ │ │ │ + blhi e6574 <__bss_end__@@Base+0x3f9d4> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0070f8cc │ │ │ │ umullslt r4, r9, r2, r9 │ │ │ │ @ instruction: 0x46054b92 │ │ │ │ - bmi fe4bc330 <__bss_end__@@Base+0xfe4156f8> │ │ │ │ + bmi fe4bc2b8 <__bss_end__@@Base+0xfe415718> │ │ │ │ stmiapl fp, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ tstls r7, #1769472 @ 0x1b0000 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ orrpl pc, r0, #0, 10 │ │ │ │ ldrdvc pc, [r0, -r3] │ │ │ │ ldrhlt r6, [r3, #139] @ 0x8b │ │ │ │ - bcs 72ad0 <__bss_start@@Base+0x17a30> │ │ │ │ + bcs 72a58 <__bss_start@@Base+0x17a50> │ │ │ │ rscshi pc, lr, r0, lsl #4 │ │ │ │ mcr2 7, 5, pc, cr6, cr15, {7} @ │ │ │ │ rsbsle r2, sl, r0, lsl #16 │ │ │ │ ldrbtmi r4, [ip], #-3208 @ 0xfffff378 │ │ │ │ - blmi fe17db9c <__bss_end__@@Base+0xfe0d6f64> │ │ │ │ + blmi fe17db24 <__bss_end__@@Base+0xfe0d6f84> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 6051ec <__bss_end__@@Base+0x55e5b4> │ │ │ │ + blls 605174 <__bss_end__@@Base+0x55e5d4> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ @ instruction: 0x462080f7 │ │ │ │ ldc 0, cr11, [sp], #100 @ 0x64 │ │ │ │ pop {r1, r8, r9, fp, pc} │ │ │ │ stmiavs r3, {r4, r5, r6, r7, r8, r9, sl, fp, pc}^ │ │ │ │ ldrbeq r6, [lr, #2169] @ 0x879 │ │ │ │ - blmi 202037c <__bss_end__@@Base+0x1f79744> │ │ │ │ + blmi 2020304 <__bss_end__@@Base+0x1f79764> │ │ │ │ @ instruction: 0xf8521c48 │ │ │ │ andle r9, r6, r3 │ │ │ │ orrpl pc, sl, #1325400064 @ 0x4f000000 │ │ │ │ movwls pc, #6915 @ 0x1b03 @ │ │ │ │ - blcs 45624 │ │ │ │ + blcs 455ac │ │ │ │ @ instruction: 0xf509d177 │ │ │ │ @ instruction: 0xf505360a │ │ │ │ @ instruction: 0xf10973ac │ │ │ │ strbcc r0, [r8], r8, asr #9 │ │ │ │ - blhi 1be6848 <__bss_end__@@Base+0x1b3fc10> │ │ │ │ - blvc fe8a830c <__bss_end__@@Base+0xfe8016d4> │ │ │ │ - beq 1067608 <__bss_end__@@Base+0xfc09d0> │ │ │ │ + blhi 1be67d0 <__bss_end__@@Base+0x1b3fc30> │ │ │ │ + blvc fe8a8294 <__bss_end__@@Base+0xfe8016f4> │ │ │ │ + beq 1067590 <__bss_end__@@Base+0xfc09f0> │ │ │ │ @ instruction: 0xf04f4698 │ │ │ │ @ instruction: 0xf8cd31ff │ │ │ │ stmib sp, {r2, r3, ip, pc}^ │ │ │ │ @ instruction: 0xf1a41701 │ │ │ │ addsmi r0, sp, #200, 6 @ 0x20000003 │ │ │ │ @ instruction: 0xf854d032 │ │ │ │ - blvs 1af6440 <__bss_end__@@Base+0x1a4f808> │ │ │ │ + blvs 1af63c8 <__bss_end__@@Base+0x1a4f828> │ │ │ │ mlale sp, sl, r2, r4 │ │ │ │ ldccc 8, cr15, [r8], #336 @ 0x150 │ │ │ │ stmdale r9!, {r3, r8, r9, fp, sp} │ │ │ │ vpmax.u8 d15, d3, d27 │ │ │ │ strle r0, [r5, #-2010]! @ 0xfffff826 │ │ │ │ @ instruction: 0x46414652 │ │ │ │ sbcvc pc, r0, r4, lsl #10 │ │ │ │ @ instruction: 0xf7e0af04 │ │ │ │ - @ instruction: 0xf105f82b │ │ │ │ + @ instruction: 0xf105f8ff │ │ │ │ ldrmi r0, [r9], -r8, asr #6 │ │ │ │ @ instruction: 0x4650463a │ │ │ │ @ instruction: 0xf7e04699 │ │ │ │ - @ instruction: 0x4652f8d5 │ │ │ │ + ldrbmi pc, [r2], -r2, ror #20 @ │ │ │ │ strtmi r4, [r0], -r1, asr #12 │ │ │ │ - @ instruction: 0xf89ef7e0 │ │ │ │ - bge 2bcb54 <__bss_end__@@Base+0x215f1c> │ │ │ │ + @ instruction: 0xf9eef7e0 │ │ │ │ + bge 2bcadc <__bss_end__@@Base+0x215f3c> │ │ │ │ @ instruction: 0xf7e04650 │ │ │ │ - ldrtmi pc, [r8], -fp, asr #17 @ │ │ │ │ - ldc2 7, cr15, [r2], {223} @ 0xdf │ │ │ │ - bleq ff266d10 <__bss_end__@@Base+0xff1c00d8> │ │ │ │ - blx 466e08 <__bss_end__@@Base+0x3c01d0> │ │ │ │ + @ instruction: 0x4638fa58 │ │ │ │ + mrrc2 7, 13, pc, ip, cr15 @ │ │ │ │ + bleq ff266c98 <__bss_end__@@Base+0xff1c00f8> │ │ │ │ + blx 466d90 <__bss_end__@@Base+0x3c01f0> │ │ │ │ cdp 5, 11, cr13, cr0, cr4, {0} │ │ │ │ @ instruction: 0xf8548b40 │ │ │ │ movwls r3, #7368 @ 0x1cc8 │ │ │ │ strpl pc, [sl], #1284 @ 0x504 │ │ │ │ bicle r4, r4, r6, lsr #5 │ │ │ │ @ instruction: 0x1701e9dd │ │ │ │ @ instruction: 0xf8dd2300 │ │ │ │ rscsvs r9, fp, ip │ │ │ │ rsbsvs r1, r9, fp, asr #24 │ │ │ │ @ instruction: 0x4628d11f │ │ │ │ @ instruction: 0xff60f013 │ │ │ │ stmdacs r0, {r2, r9, sl, lr} │ │ │ │ strtmi sp, [r8], -r0, lsl #3 │ │ │ │ - blx fffe72ea <__bss_end__@@Base+0xfff406b2> │ │ │ │ + blx fffe7272 <__bss_end__@@Base+0xfff406d2> │ │ │ │ @ instruction: 0xf0014628 │ │ │ │ @ instruction: 0x4628fe39 │ │ │ │ stc2 0, cr15, [r6], {22} │ │ │ │ @ instruction: 0xf7fe4628 │ │ │ │ @ instruction: 0xe773ffdf │ │ │ │ rscle r1, sl, ip, asr #24 │ │ │ │ @ instruction: 0xf8524b42 │ │ │ │ vst4.8 {d25-d28}, [pc], r3 │ │ │ │ - blx 1000ca <__bss_end__@@Base+0x59492> │ │ │ │ + blx 100052 <__bss_end__@@Base+0x594b2> │ │ │ │ ldmdbvs fp, {r0, r8, r9, ip, pc} │ │ │ │ movwcs fp, #6411 @ 0x190b │ │ │ │ vst4.32 {d22-d25}, [pc :256], fp │ │ │ │ ldcge 6, cr5, [r0], {138} @ 0x8a │ │ │ │ - blvc feb686c8 <__bss_end__@@Base+0xfeac1a90> │ │ │ │ + blvc feb68650 <__bss_end__@@Base+0xfeac1ab0> │ │ │ │ @ instruction: 0xf1054622 │ │ │ │ @ instruction: 0xf10d0a48 │ │ │ │ - blx 6d302 <__bss_start@@Base+0x12262> │ │ │ │ + blx 6d28a <__bss_start@@Base+0x12282> │ │ │ │ ldrbmi pc, [r9], -r6, lsl #12 @ │ │ │ │ andsvc pc, r2, r6, lsl #10 │ │ │ │ - @ instruction: 0xf7df4448 │ │ │ │ - ldrbmi pc, [r1], -sp, asr #31 @ │ │ │ │ + @ instruction: 0xf7e04448 │ │ │ │ + ldrbmi pc, [r1], -r1, lsr #17 @ │ │ │ │ strtmi r4, [r0], -r2, asr #12 │ │ │ │ - @ instruction: 0xf87af7e0 │ │ │ │ + blx 2291e0 <__bss_end__@@Base+0x182640> │ │ │ │ sbceq pc, r8, r6, lsl #2 │ │ │ │ ldrbmi r4, [r9], -r8, asr #8 │ │ │ │ @ instruction: 0xf7e04622 │ │ │ │ - ldrbmi pc, [r1], -r1, asr #16 @ │ │ │ │ - bge 2bcb6c <__bss_end__@@Base+0x215f34> │ │ │ │ - @ instruction: 0xf86ef7e0 │ │ │ │ + @ instruction: 0x4651f991 │ │ │ │ + bge 2bcaf4 <__bss_end__@@Base+0x215f54> │ │ │ │ + @ instruction: 0xf9fbf7e0 │ │ │ │ strtmi r4, [r8], -r1, asr #12 │ │ │ │ ldc2 7, cr15, [sl], #-1020 @ 0xfffffc04 │ │ │ │ - blcs 456e8 │ │ │ │ + blcs 45670 │ │ │ │ @ instruction: 0x2103d1b5 │ │ │ │ @ instruction: 0xf01b4628 │ │ │ │ stmdacs r0, {r0, r2, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ tstcs r3, r1, lsr #22 │ │ │ │ @ instruction: 0xf01b4628 │ │ │ │ mvnlt pc, r9, ror #22 │ │ │ │ strtmi r2, [r8], -r0, lsl #6 │ │ │ │ @ instruction: 0x4619461a │ │ │ │ - blx fe4e738e <__bss_end__@@Base+0xfe440756> │ │ │ │ + blx fe4e7316 <__bss_end__@@Base+0xfe440776> │ │ │ │ @ instruction: 0xd1a22801 │ │ │ │ @ instruction: 0xf01b4628 │ │ │ │ @ instruction: 0xf7e9fb75 │ │ │ │ - mrc 9, 5, APSR_nzcv, cr2, cr3, {2} │ │ │ │ + mrc 9, 5, APSR_nzcv, cr2, cr11, {7} │ │ │ │ vmla.f64 d7, d0, d4 │ │ │ │ ldmdami fp, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ strtmi r2, [r9], -r0, lsl #4 │ │ │ │ mrc 4, 5, r4, cr0, cr8, {3} │ │ │ │ @ instruction: 0xf7f70b47 │ │ │ │ ldmvs fp!, {r0, r3, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ rscsvs r3, fp, r1, lsl #6 │ │ │ │ @@ -40765,49 +40760,49 @@ │ │ │ │ smlabbcs r2, r7, fp, sp │ │ │ │ @ instruction: 0xf01b4628 │ │ │ │ stmdacs r0, {r0, r6, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xe780d1d6 │ │ │ │ vpmax.s8 d20, d0, d15 │ │ │ │ stmdami pc, {r1, r2, r3, r5, r6, r7, r8, sp} @ │ │ │ │ ldrbtmi r4, [r8], #-1146 @ 0xfffffb86 │ │ │ │ - blx 1669314 <__bss_end__@@Base+0x15c26dc> │ │ │ │ - stcl 7, cr15, [r6, #860]! @ 0x35c │ │ │ │ - ldmda lr, {r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + cdp2 7, 4, cr15, cr12, cr7, {7} │ │ │ │ + ldcl 7, cr15, [sl, #860]! @ 0x35c │ │ │ │ + ldmda r6!, {r3, r4, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andeq r0, r0, r0 │ │ │ │ orrsmi sp, r7, r4, lsl #15 │ │ │ │ - @ instruction: 0x0002ceb8 │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - @ instruction: 0x0002ceb4 │ │ │ │ - andeq pc, r1, r2, lsl #25 │ │ │ │ - andeq ip, r2, r4, lsl #29 │ │ │ │ - andeq r0, r0, r0, lsr #5 │ │ │ │ + andeq ip, r2, r0, lsr pc │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq ip, r2, ip, lsr #30 │ │ │ │ + @ instruction: 0x0001febe │ │ │ │ + strdeq ip, [r2], -ip @ │ │ │ │ + muleq r0, r8, r2 │ │ │ │ @ instruction: 0xfffff815 │ │ │ │ - andeq pc, r1, r8, lsr #21 │ │ │ │ - @ instruction: 0x0001faba │ │ │ │ + andeq pc, r1, r4, ror #25 │ │ │ │ + strdeq pc, [r1], -r6 │ │ │ │ ldrbtmi r4, [fp], #-2817 @ 0xfffff4ff │ │ │ │ @ instruction: 0x47706018 │ │ │ │ - strdeq r2, [r3], -sl │ │ │ │ - blvc 326a3c <__bss_end__@@Base+0x27fe04> │ │ │ │ - bleq ff226e94 <__bss_end__@@Base+0xff18025c> │ │ │ │ - blx 466f8c <__bss_end__@@Base+0x3c0354> │ │ │ │ + ldrdeq r2, [r3], -sl │ │ │ │ + blvc 3269c4 <__bss_end__@@Base+0x27fe24> │ │ │ │ + bleq ff226e1c <__bss_end__@@Base+0xff18027c> │ │ │ │ + blx 466f14 <__bss_end__@@Base+0x3c0374> │ │ │ │ cdp 4, 11, cr13, cr7, cr13, {0} │ │ │ │ vmov.f64 d7, #64 @ 0x3e000000 0.125 │ │ │ │ vneg.f64 d16, d7 │ │ │ │ svclt 0x00c8fa10 │ │ │ │ - bleq 1226e9c <__bss_end__@@Base+0x1180264> │ │ │ │ + bleq 1226e24 <__bss_end__@@Base+0x1180284> │ │ │ │ ldrbtmi r4, [fp], #-2821 @ 0xfffff4fb │ │ │ │ - bleq 669f0 <__bss_start@@Base+0xb950> │ │ │ │ + bleq 66978 <__bss_start@@Base+0xb970> │ │ │ │ mrc 7, 5, r4, cr0, cr0, {3} │ │ │ │ ldrb r0, [r7, r7, asr #22]! │ │ │ │ ldmibls r9, {r1, r3, r4, r7, r8, fp, ip, pc} │ │ │ │ svccc 0x00a99999 │ │ │ │ - strdeq pc, [r2], -sl │ │ │ │ + ldrdeq pc, [r2], -sl │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb82600 <__bss_end__@@Base+0xfeadb9c8> │ │ │ │ + bl feb82588 <__bss_end__@@Base+0xfeadb9e8> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0x46040ff0 │ │ │ │ @ instruction: 0xf898f002 │ │ │ │ @ instruction: 0xf0014620 │ │ │ │ @ instruction: 0x4620fd55 │ │ │ │ ldc2l 0, cr15, [r2, #-4] │ │ │ │ @ instruction: 0xf0014620 │ │ │ │ @@ -40824,77 +40819,77 @@ │ │ │ │ @ instruction: 0x61234620 │ │ │ │ strpl pc, [r0], #1284 @ 0x504 │ │ │ │ @ instruction: 0xf01b2102 │ │ │ │ @ instruction: 0xf8d4fac9 │ │ │ │ cmnlt fp, r0, lsl #2 │ │ │ │ tstcs r0, ip, lsl #20 │ │ │ │ teqpeq r8, r4 @ @ p-variant is OBSOLETE │ │ │ │ - ldrbcc pc, [pc, #79]! @ 2b4b3 @ │ │ │ │ + ldrbcc pc, [pc, #79]! @ 2b43b @ │ │ │ │ ldrbtmi r6, [sl], #-217 @ 0xffffff27 │ │ │ │ smlabtpl r1, r3, r9, lr │ │ │ │ smlabtcc r0, r4, r8, pc @ │ │ │ │ @ instruction: 0xf8c46018 │ │ │ │ ldclt 1, cr2, [r8, #-224]! @ 0xffffff20 │ │ │ │ eorcs r4, r8, #327680 @ 0x50000 │ │ │ │ teqpne r9, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7e84478 │ │ │ │ - @ instruction: 0x4603fab3 │ │ │ │ + @ instruction: 0x4603fb5b │ │ │ │ svclt 0x0000e7e6 │ │ │ │ @ instruction: 0xfffffcc3 │ │ │ │ - andeq pc, r1, ip, lsr #19 │ │ │ │ + andeq pc, r1, r8, ror #23 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - blhi 1e6954 <__bss_end__@@Base+0x13fd1c> │ │ │ │ + blhi 1e68dc <__bss_end__@@Base+0x13fd3c> │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ cdpeq 8, 9, cr15, cr8, cr12, {6} │ │ │ │ sbclt r4, fp, ip, lsl #18 │ │ │ │ strmi r4, [r7], -ip, lsl #22 │ │ │ │ - bmi 33c698 <__bss_end__@@Base+0x295a60> │ │ │ │ + bmi 33c620 <__bss_end__@@Base+0x295a80> │ │ │ │ stmiapl fp, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ movtls r6, #38939 @ 0x981b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - blcs c61d0 <__bss_end__@@Base+0x1f598> │ │ │ │ + blcs c6158 <__bss_end__@@Base+0x1f5b8> │ │ │ │ sbchi pc, r9, #0 │ │ │ │ ldrbtmi r4, [fp], #-2823 @ 0xfffff4f9 │ │ │ │ movwcs r9, #8970 @ 0x230a │ │ │ │ - blmi 1d00f4 <__bss_end__@@Base+0x1294bc> │ │ │ │ + blmi 1d007c <__bss_end__@@Base+0x1294dc> │ │ │ │ ldmpl r3, {r8, sl, sp}^ │ │ │ │ and r9, pc, r6, lsl #6 │ │ │ │ - andeq ip, r2, r0, asr fp │ │ │ │ - ldrdeq r0, [r0], -r8 │ │ │ │ - andeq ip, r2, ip, asr #22 │ │ │ │ - andeq pc, r1, r2, ror r9 @ │ │ │ │ - andeq r0, r0, r0, lsr #5 │ │ │ │ + andeq ip, r2, r8, asr #23 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq ip, r2, r4, asr #23 │ │ │ │ + andeq pc, r1, lr, lsr #23 │ │ │ │ + muleq r0, r8, r2 │ │ │ │ @ instruction: 0xf5033501 │ │ │ │ stccs 3, cr5, [r0, #-552]! @ 0xfffffdd8 │ │ │ │ adcshi pc, r5, #0 │ │ │ │ @ instruction: 0x2e00691e │ │ │ │ vst4. {d29,d31,d33,d35}, [pc :256], r6 │ │ │ │ stmdbls r8, {r1, r3, r7, r8, r9, ip, lr} │ │ │ │ @ instruction: 0xf1079509 │ │ │ │ - blx edcd2 <__bss_end__@@Base+0x4709a> │ │ │ │ - blls 1ea128 <__bss_end__@@Base+0x1434f0> │ │ │ │ + blx edc5a <__bss_end__@@Base+0x470ba> │ │ │ │ + blls 1ea0b0 <__bss_end__@@Base+0x143510> │ │ │ │ streq lr, [fp], #-2819 @ 0xfffff4fd │ │ │ │ subeq pc, r8, r4, lsl #2 │ │ │ │ - beq ff267930 <__bss_end__@@Base+0xff1c0cf8> │ │ │ │ + beq ff2678b8 <__bss_end__@@Base+0xff1c0d18> │ │ │ │ andpl pc, fp, r3, asr #16 │ │ │ │ ldmeq r0!, {r2, r8, ip, sp, lr, pc}^ │ │ │ │ strtcc pc, [r0], #-2271 @ 0xfffff721 │ │ │ │ tstcs r6, r1, ror #6 │ │ │ │ @ instruction: 0xf1076121 │ │ │ │ ldmpl r3, {r3, r6, r8}^ │ │ │ │ strbtvs r2, [r6], #-640 @ 0xfffffd80 │ │ │ │ ldc 1, cr9, [r3, #52] @ 0x34 │ │ │ │ vstr d8, [r4] │ │ │ │ @ instruction: 0xf7d78b0e │ │ │ │ - @ instruction: 0xf107ee72 │ │ │ │ + @ instruction: 0xf107ee8a │ │ │ │ @ instruction: 0xf50701c8 │ │ │ │ strmi r7, [sp], -r4, lsl #29 │ │ │ │ stcvc 5, cr15, [r4], {4} │ │ │ │ - blvc 167024 <__bss_end__@@Base+0xc03ec> │ │ │ │ + blvc 166fac <__bss_end__@@Base+0xc040c> │ │ │ │ stmia sl!, {r0, r1, r2, r3, r8, sl, fp, lr, pc} │ │ │ │ cdp 0, 3, cr0, cr8, cr15, {0} │ │ │ │ ldm r5, {r0, r1, r2, r6, r8, r9, fp, pc} │ │ │ │ stm sl, {r0, r1} │ │ │ │ @ instruction: 0xf5070003 │ │ │ │ @ instruction: 0xf5047a06 │ │ │ │ ldmib r7, {r2, r3, r8, sl, ip, sp, lr}^ │ │ │ │ @@ -40908,42 +40903,42 @@ │ │ │ │ ldm lr!, {r2, r3, fp, ip, sp, lr} │ │ │ │ stmia ip!, {r0, r1, r2, r3} │ │ │ │ addcs r0, r0, #15 │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ @ instruction: 0x71acf507 │ │ │ │ adcvc pc, ip, r4, lsl #10 │ │ │ │ - blhi 1566bc4 <__bss_end__@@Base+0x14bff8c> │ │ │ │ - mrc 7, 1, APSR_nzcv, cr10, cr7, {6} │ │ │ │ + blhi 1566b4c <__bss_end__@@Base+0x14bffac> │ │ │ │ + mrc 7, 2, APSR_nzcv, cr2, cr7, {6} │ │ │ │ cdpvc 5, 9, cr15, cr0, cr7, {0} │ │ │ │ @ instruction: 0xf50b9a06 │ │ │ │ @ instruction: 0xf5077342 │ │ │ │ @ instruction: 0xf5047112 │ │ │ │ tstls r7, r2, lsl r0 │ │ │ │ ldmne r1, {r0, r1, r3, ip, pc}^ │ │ │ │ @ instruction: 0xf504910c │ │ │ │ ldm lr!, {r4, r7, sl, fp, ip, sp, lr} │ │ │ │ cdp 0, 11, cr0, cr7, cr15, {0} │ │ │ │ stmia ip!, {r8, r9, fp, sp, lr} │ │ │ │ - ldc 0, cr0, [pc, #60] @ 2b620 │ │ │ │ - vldr d8, [pc, #800] @ 2b908 │ │ │ │ + ldc 0, cr0, [pc, #60] @ 2b5a8 │ │ │ │ + vldr d8, [pc, #800] @ 2b890 │ │ │ │ ldm lr, {r0, r3, r6, r7, r8, r9, fp, ip, sp, lr} │ │ │ │ stm ip, {r0, r1, r2, r3} │ │ │ │ ldmib r7, {r0, r1, r2, r3}^ │ │ │ │ stmib r4, {r4, r6, r8, r9, sp}^ │ │ │ │ ldm sl!, {r4, r6, r8, r9, sp} │ │ │ │ stmia r9!, {r0, r1, r2, r3} │ │ │ │ ldm sl, {r0, r1, r2, r3} │ │ │ │ stm r9, {r0, r1} │ │ │ │ ldm r8!, {r0, r1} │ │ │ │ - strgt r0, [pc, #-15] @ 2b601 │ │ │ │ + strgt r0, [pc, #-15] @ 2b589 │ │ │ │ muleq r3, r8, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ @ instruction: 0xf10b9d07 │ │ │ │ - stcgt 8, cr0, [pc, #-80] @ 2b5d0 │ │ │ │ + stcgt 8, cr0, [pc, #-80] @ 2b558 │ │ │ │ stcls 5, cr9, [fp, #-28] @ 0xffffffe4 │ │ │ │ strtmi ip, [fp], -pc, lsl #10 │ │ │ │ ldm r5, {r0, r1, r2, r8, sl, fp, ip, pc} │ │ │ │ stmib r3, {r0, r1}^ │ │ │ │ stmdbls sl, {r8} │ │ │ │ strmi pc, [r0, #-1103] @ 0xfffffbb1 │ │ │ │ cmncs ip, #3522560 @ 0x35c000 │ │ │ │ @@ -40983,113 +40978,113 @@ │ │ │ │ ldmib r7, {r1, r7, r8, r9, sp}^ │ │ │ │ stmib r4, {r2, r7, r8, r9, sp}^ │ │ │ │ stcls 3, cr2, [ip, #-528] @ 0xfffffdf0 │ │ │ │ stc 0, cr6, [r4, #920] @ 0x398 │ │ │ │ vstr d8, [r4, #760] @ 0x2f8 │ │ │ │ vstr d8, [r5, #768] @ 0x300 │ │ │ │ strcs r7, [r4, #-2816] @ 0xfffff500 │ │ │ │ - blhi ff166cf0 <__bss_end__@@Base+0xff0c00b8> │ │ │ │ + blhi ff166c78 <__bss_end__@@Base+0xff0c00d8> │ │ │ │ msrpl CPSR_f, #196, 16 @ 0xc40000 │ │ │ │ - blhi ff1e6cf8 <__bss_end__@@Base+0xff1400c0> │ │ │ │ - blhi ff266cfc <__bss_end__@@Base+0xff1c00c4> │ │ │ │ - blhi ff366d00 <__bss_end__@@Base+0xff2c00c8> │ │ │ │ + blhi ff1e6c80 <__bss_end__@@Base+0xff1400e0> │ │ │ │ + blhi ff266c84 <__bss_end__@@Base+0xff1c00e4> │ │ │ │ + blhi ff366c88 <__bss_end__@@Base+0xff2c00e8> │ │ │ │ @ instruction: 0xff22f00b │ │ │ │ ldmibmi r6, {r1, r2, r8, sl, fp, ip, pc} │ │ │ │ - bls 27c99c <__bss_end__@@Base+0x1d5d64> │ │ │ │ + bls 27c924 <__bss_end__@@Base+0x1d5d84> │ │ │ │ @ instruction: 0xf8c44479 │ │ │ │ strbmi r0, [r0], -ip, lsr #6 │ │ │ │ - svc 0x007cf7d7 │ │ │ │ + svc 0x0086f7d7 │ │ │ │ @ instruction: 0xf64f4620 │ │ │ │ stc 3, cr7, [r4, #1020] @ 0x3fc │ │ │ │ @ instruction: 0xf8a48bd0 │ │ │ │ stc 3, cr3, [r4, #224] @ 0xe0 │ │ │ │ @ instruction: 0xf0148bd2 │ │ │ │ @ instruction: 0xf8d4fbe7 │ │ │ │ vcgt.s8 d19, d1, d28 │ │ │ │ strtmi r0, [r0], -ip, lsr #5 │ │ │ │ strbcc pc, [r8, #-2259] @ 0xfffff72d @ │ │ │ │ vhadd.s8 d21, d17, d22 │ │ │ │ adcpl r1, r6, r4, lsl #4 │ │ │ │ strbeq pc, [r8], fp, lsl #2 @ │ │ │ │ @ instruction: 0x46204798 │ │ │ │ - bleq feb66d50 <__bss_end__@@Base+0xfeac0118> │ │ │ │ + bleq feb66cd8 <__bss_end__@@Base+0xfeac0138> │ │ │ │ cdp2 0, 5, cr15, cr8, cr1, {0} │ │ │ │ strtmi r4, [lr], #-1568 @ 0xfffff9e0 │ │ │ │ cdp2 0, 15, cr15, cr8, cr1, {0} │ │ │ │ ldrbtmi r4, [fp], #-2945 @ 0xfffff47f │ │ │ │ - blcs 457c0 │ │ │ │ + blcs 45748 │ │ │ │ mrshi pc, (UNDEF: 72) @ │ │ │ │ - blge 1be6dd8 <__bss_end__@@Base+0x1b401a0> │ │ │ │ - @ instruction: 0xff3af7e8 │ │ │ │ - blls 1be6de0 <__bss_end__@@Base+0x1b401a8> │ │ │ │ - bleq 2e6fe8 <__bss_end__@@Base+0x2403b0> │ │ │ │ - bleq 4e6da0 <__bss_end__@@Base+0x440168> │ │ │ │ - @ instruction: 0xff32f7e8 │ │ │ │ - bleq 2e6ff4 <__bss_end__@@Base+0x2403bc> │ │ │ │ - blvc 11e6dd4 <__bss_end__@@Base+0x114019c> │ │ │ │ - blls 1227060 <__bss_end__@@Base+0x1180428> │ │ │ │ - bleq 566db4 <__bss_end__@@Base+0x4c017c> │ │ │ │ - @ instruction: 0xff28f7e8 │ │ │ │ - blvc 1a26e04 <__bss_end__@@Base+0x19801cc> │ │ │ │ - blls 226f8c <__bss_end__@@Base+0x180354> │ │ │ │ - blls 5e6dc4 <__bss_end__@@Base+0x54018c> │ │ │ │ - @ instruction: 0xff20f7e8 │ │ │ │ - blvc 19a6e14 <__bss_end__@@Base+0x19001dc> │ │ │ │ - blls 19e6e18 <__bss_end__@@Base+0x19401e0> │ │ │ │ - bleq 227020 <__bss_end__@@Base+0x1803e8> │ │ │ │ - blx fe0677f6 <__bss_end__@@Base+0xfdfc0bbe> │ │ │ │ - blhi 1ee6db8 <__bss_end__@@Base+0x1e40180> │ │ │ │ + blge 1be6d60 <__bss_end__@@Base+0x1b401c0> │ │ │ │ + @ instruction: 0xffe2f7e8 │ │ │ │ + blls 1be6d68 <__bss_end__@@Base+0x1b401c8> │ │ │ │ + bleq 2e6f70 <__bss_end__@@Base+0x2403d0> │ │ │ │ + bleq 4e6d28 <__bss_end__@@Base+0x440188> │ │ │ │ + @ instruction: 0xffdaf7e8 │ │ │ │ + bleq 2e6f7c <__bss_end__@@Base+0x2403dc> │ │ │ │ + blvc 11e6d5c <__bss_end__@@Base+0x11401bc> │ │ │ │ + blls 1226fe8 <__bss_end__@@Base+0x1180448> │ │ │ │ + bleq 566d3c <__bss_end__@@Base+0x4c019c> │ │ │ │ + @ instruction: 0xffd0f7e8 │ │ │ │ + blvc 1a26d8c <__bss_end__@@Base+0x19801ec> │ │ │ │ + blls 226f14 <__bss_end__@@Base+0x180374> │ │ │ │ + blls 5e6d4c <__bss_end__@@Base+0x5401ac> │ │ │ │ + @ instruction: 0xffc8f7e8 │ │ │ │ + blvc 19a6d9c <__bss_end__@@Base+0x19001fc> │ │ │ │ + blls 19e6da0 <__bss_end__@@Base+0x1940200> │ │ │ │ + bleq 226fa8 <__bss_end__@@Base+0x180408> │ │ │ │ + blx fe06777e <__bss_end__@@Base+0xfdfc0bde> │ │ │ │ + blhi 1ee6d40 <__bss_end__@@Base+0x1e401a0> │ │ │ │ ldmib r3, {r1, r2, r5, r6, r8, r9, sp, pc}^ │ │ │ │ stmib r4, {r8, r9, sp}^ │ │ │ │ stc 3, cr2, [r4, #480] @ 0x1e0 │ │ │ │ @ instruction: 0xf7e80b76 │ │ │ │ - cdp 15, 11, cr15, cr0, cr13, {0} │ │ │ │ - vldr d6, [pc, #256] @ 2b8c0 │ │ │ │ + mrc 15, 5, APSR_nzcv, cr0, cr5, {5} │ │ │ │ + vldr d6, [pc, #256] @ 2b848 │ │ │ │ @ instruction: 0xee067b5f │ │ │ │ stmdbge lr, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ - bleq 1de6e1c <__bss_end__@@Base+0x1d401e4> │ │ │ │ + bleq 1de6da4 <__bss_end__@@Base+0x1d40204> │ │ │ │ @ instruction: 0xf7d7a810 │ │ │ │ - ldc 12, cr14, [sp, #336] @ 0x150 │ │ │ │ + ldc 12, cr14, [sp, #424] @ 0x1a8 │ │ │ │ vldr d0, [sp, #56] @ 0x38 │ │ │ │ vmov.32 r1, d0[1] │ │ │ │ ldrtmi r2, [r0], -r8, asr #22 │ │ │ │ - blhi 1266e60 <__bss_end__@@Base+0x11c0228> │ │ │ │ + blhi 1266de8 <__bss_end__@@Base+0x11c0248> │ │ │ │ @ instruction: 0xf50bae18 │ │ │ │ @ instruction: 0xf10b79ac │ │ │ │ @ instruction: 0xee200af0 │ │ │ │ vmul.f64 d0, d1, d9 │ │ │ │ @ instruction: 0xf7df1b09 │ │ │ │ - bls 1e9e40 <__bss_end__@@Base+0x143208> │ │ │ │ + bls 1e9c48 <__bss_end__@@Base+0x1430a8> │ │ │ │ vst2.8 {d25,d27}, [pc], r9 │ │ │ │ @ instruction: 0xf10b538a │ │ │ │ ldrmi r0, [r0], #-72 @ 0xffffffb8 │ │ │ │ strcs pc, [r1, #-2819] @ 0xfffff4fd │ │ │ │ - blcs 1de6e64 <__bss_end__@@Base+0x1d4022c> │ │ │ │ - blne 1e66e68 <__bss_end__@@Base+0x1dc0230> │ │ │ │ - bleq 1ee6e6c <__bss_end__@@Base+0x1e40234> │ │ │ │ - blhi 1f66e30 <__bss_end__@@Base+0x1ec01f8> │ │ │ │ - blhi 1fe6e34 <__bss_end__@@Base+0x1f401fc> │ │ │ │ - blhi fe066e38 <__bss_end__@@Base+0xfdfc0200> │ │ │ │ - mcr2 7, 0, pc, cr4, cr15, {6} @ │ │ │ │ + blcs 1de6dec <__bss_end__@@Base+0x1d4024c> │ │ │ │ + blne 1e66df0 <__bss_end__@@Base+0x1dc0250> │ │ │ │ + bleq 1ee6df4 <__bss_end__@@Base+0x1e40254> │ │ │ │ + blhi 1f66db8 <__bss_end__@@Base+0x1ec0218> │ │ │ │ + blhi 1fe6dbc <__bss_end__@@Base+0x1f4021c> │ │ │ │ + blhi fe066dc0 <__bss_end__@@Base+0xfdfc0220> │ │ │ │ + @ instruction: 0xffcef7df │ │ │ │ stmdbls sp, {r1, r4, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7dfa812 │ │ │ │ - blls 1eaea0 <__bss_end__@@Base+0x144268> │ │ │ │ + blls 1eb368 <__bss_end__@@Base+0x1447c8> │ │ │ │ @ instruction: 0xf50b4630 │ │ │ │ ldrmi r7, [sl], #1668 @ 0x684 │ │ │ │ @ instruction: 0x46524499 │ │ │ │ @ instruction: 0xf7df4649 │ │ │ │ - ldc 13, cr15, [r7, #780] @ 0x30c │ │ │ │ + ldc 15, cr15, [r7, #320] @ 0x140 │ │ │ │ vldr d4, [r5, #240] @ 0xf0 │ │ │ │ vpadd.i8 d21, d1, d28 │ │ │ │ ldc 2, cr1, [r5, #224] @ 0xe0 │ │ │ │ @ instruction: 0xf1056b3e │ │ │ │ ldc 14, cr0, [r5, #960] @ 0x3c0 │ │ │ │ @ instruction: 0xf5057b40 │ │ │ │ mrc 12, 1, r7, cr5, cr2, {0} │ │ │ │ - blls 1c2478 <__bss_end__@@Base+0x11b840> │ │ │ │ + blls 1c2400 <__bss_end__@@Base+0x11b860> │ │ │ │ ldrmi r4, [lr], #-2363 @ 0xfffff6c5 │ │ │ │ teqpne ip, #268435460 @ p-variant is OBSOLETE @ 0x10000004 │ │ │ │ stc 4, cr4, [r5, #484] @ 0x1e4 │ │ │ │ vldr d5, [r7, #240] @ 0xf0 │ │ │ │ vmov.s16 r5, d6[2] │ │ │ │ vstr d6, [r5, #20] │ │ │ │ vldr d6, [r7, #248] @ 0xf8 │ │ │ │ @@ -41099,30 +41094,30 @@ │ │ │ │ stc 0, cr5, [r5, #936] @ 0x3a8 │ │ │ │ ldm lr!, {r6, r8, r9, fp, ip, sp, lr} │ │ │ │ stmia ip!, {r0, r1, r2, r3} │ │ │ │ ldm lr, {r0, r1, r2, r3} │ │ │ │ stm ip, {r0, r1} │ │ │ │ ldrbmi r0, [r0], -r3 │ │ │ │ @ instruction: 0xf7e34631 │ │ │ │ - @ instruction: 0x4649fbb3 │ │ │ │ + strbmi pc, [r9], -r7, lsr #31 @ │ │ │ │ @ instruction: 0xf7e44630 │ │ │ │ - @ instruction: 0xf8d5f97f │ │ │ │ + @ instruction: 0xf8d5fd73 │ │ │ │ strtmi r3, [r0], -ip, lsr #6 │ │ │ │ strbcc pc, [ip, #-2259] @ 0xfffff72d @ │ │ │ │ @ instruction: 0x21024798 │ │ │ │ @ instruction: 0xf01b4620 │ │ │ │ @ instruction: 0xf50bf88d │ │ │ │ ldmib r5, {r0, r2, r7, r8, r9, ip, lr}^ │ │ │ │ stmib sp, {r2, r3, r4, r5, r8, r9, fp, sp, pc}^ │ │ │ │ - bls 1d6550 <__bss_end__@@Base+0x12f918> │ │ │ │ + bls 1d64d8 <__bss_end__@@Base+0x12f938> │ │ │ │ ldmib r5, {r3, r8, r9, ip, sp}^ │ │ │ │ stmib sp, {r1, r2, r3, r4, r5, r8, r9, fp, sp, pc}^ │ │ │ │ ldmib r5, {r5, r8, r9, fp, sp, pc}^ │ │ │ │ ldmne r6, {r6, r8, r9, fp, sp, pc}^ │ │ │ │ - blge 8e6020 <__bss_end__@@Base+0x83f3e8> │ │ │ │ + blge 8e5fa8 <__bss_end__@@Base+0x83f408> │ │ │ │ @ instruction: 0xf8d54621 │ │ │ │ ldmib r5, {r2, r3, r5, r8, r9, sp}^ │ │ │ │ stmib sp, {r1, r2, r4, r5, r6, r8, r9, fp, sp, pc}^ │ │ │ │ ldmib r5, {r1, r3, r5, r8, r9, fp, sp, pc}^ │ │ │ │ vpadd.i8 q5, q1, q12 │ │ │ │ eor r5, sp, r4, ror #6 │ │ │ │ ... │ │ │ │ @@ -41135,126 +41130,126 @@ │ │ │ │ @ instruction: 0x401921fb │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbsmi lr, r5, r0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, r9, r0 │ │ │ │ subsge r9, r2, #3648 @ 0xe40 │ │ │ │ svccc 0x00a1df46 │ │ │ │ - andeq r0, r0, r8, lsl #6 │ │ │ │ - @ instruction: 0x0001f7b0 │ │ │ │ - andeq r1, r3, lr, asr lr │ │ │ │ + andeq r0, r0, r0, lsl #6 │ │ │ │ + andeq pc, r1, ip, ror #19 │ │ │ │ + andeq r1, r3, lr, lsr lr │ │ │ │ @ instruction: 0xfffff8b9 │ │ │ │ @ instruction: 0xfffff737 │ │ │ │ vadd.i8 d9, d2, d8 │ │ │ │ stmib sp, {r2, r3, r4, r6, r9, ip, lr}^ │ │ │ │ ldmib r5, {r2, r3, r5, r8, r9, fp, sp, pc}^ │ │ │ │ vstmdbge sl!, {d10-} │ │ │ │ strls r9, [r3, #-1541] @ 0xfffff9fb │ │ │ │ strls sl, [r0, #-3358] @ 0xfffff2e2 │ │ │ │ strls sl, [r4, #-3364] @ 0xfffff2dc │ │ │ │ strpl lr, [r1, #-2509] @ 0xfffff633 │ │ │ │ - blge be60b8 <__bss_end__@@Base+0xb3f480> │ │ │ │ - blhi 966fbc <__bss_end__@@Base+0x8c0384> │ │ │ │ - blhi 9e6fc0 <__bss_end__@@Base+0x940388> │ │ │ │ - blhi a66fc4 <__bss_end__@@Base+0x9c038c> │ │ │ │ + blge be6040 <__bss_end__@@Base+0xb3f4a0> │ │ │ │ + blhi 966f44 <__bss_end__@@Base+0x8c03a4> │ │ │ │ + blhi 9e6f48 <__bss_end__@@Base+0x9403a8> │ │ │ │ + blhi a66f4c <__bss_end__@@Base+0x9c03ac> │ │ │ │ ldc2 7, cr15, [r0], {252} @ 0xfc │ │ │ │ strtmi r2, [r0], -r1, lsl #4 │ │ │ │ @ instruction: 0xf7fe4611 │ │ │ │ @ instruction: 0x4620f8f7 │ │ │ │ stc2 7, cr15, [sl, #-1020]! @ 0xfffffc04 │ │ │ │ ldrbtmi r4, [fp], #-2887 @ 0xfffff4b9 │ │ │ │ stmdbcs r0, {r0, r3, r4, fp, sp, lr} │ │ │ │ - blmi 11dfef8 <__bss_end__@@Base+0x11392c0> │ │ │ │ + blmi 11dfe80 <__bss_end__@@Base+0x11392e0> │ │ │ │ tstls r0, fp, ror r4 │ │ │ │ stmdbmi r5, {r4, r5, sl, fp, sp, pc}^ │ │ │ │ strtmi r4, [r0], -r2, asr #12 │ │ │ │ @ instruction: 0xf7d74479 │ │ │ │ - strtmi lr, [r1], -r0, lsr #28 │ │ │ │ + strtmi lr, [r1], -sl, lsr #28 │ │ │ │ @ instruction: 0xf0144638 │ │ │ │ - bmi 10aabe8 <__bss_end__@@Base+0x1003fb0> │ │ │ │ + bmi 10aab70 <__bss_end__@@Base+0x1003fd0> │ │ │ │ ldrbtmi r4, [sl], #-2881 @ 0xfffff4bf │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r9, asr #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ sublt sp, fp, r7, asr r1 │ │ │ │ - blhi 1e6cd8 <__bss_end__@@Base+0x1400a0> │ │ │ │ + blhi 1e6c60 <__bss_end__@@Base+0x1400c0> │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - ldc2l 7, cr15, [r4, #928]! @ 0x3a0 │ │ │ │ - blvs aa706c <__bss_end__@@Base+0xa00434> │ │ │ │ - blvc ae7070 <__bss_end__@@Base+0xa40438> │ │ │ │ - blls b27074 <__bss_end__@@Base+0xa8043c> │ │ │ │ - blvc 1e71fc <__bss_end__@@Base+0x1405c4> │ │ │ │ - blvc 4e7034 <__bss_end__@@Base+0x4403fc> │ │ │ │ - stc2l 7, cr15, [r8, #928]! @ 0x3a0 │ │ │ │ - bleq 2a7288 <__bss_end__@@Base+0x200650> │ │ │ │ - bleq 567040 <__bss_end__@@Base+0x4c0408> │ │ │ │ - stc2l 7, cr15, [r2, #928]! @ 0x3a0 │ │ │ │ - bleq 2a7294 <__bss_end__@@Base+0x20065c> │ │ │ │ - blge 1de7074 <__bss_end__@@Base+0x1d4043c> │ │ │ │ - bleq 5e7050 <__bss_end__@@Base+0x540418> │ │ │ │ - ldc2l 7, cr15, [sl, #928] @ 0x3a0 │ │ │ │ - blvc 8e70a0 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ip, r2, sl, lsr #13 │ │ │ │ + ldrdeq r0, [r0], -r0 @ │ │ │ │ + andeq pc, r1, r6, lsr r6 @ │ │ │ │ + andeq pc, r1, r4, lsl r6 @ │ │ │ │ + andeq ip, r2, lr, lsl #12 │ │ │ │ + andeq pc, r1, lr, lsr r6 @ │ │ │ │ vst3.8 {d27,d29,d31}, [pc :256], r8 │ │ │ │ - bl feb82cf0 <__bss_end__@@Base+0xfeadc0b8> │ │ │ │ + bl feb82c78 <__bss_end__@@Base+0xfeadc0d8> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ @ instruction: 0xf5000ff0 │ │ │ │ strmi r5, [r4], -r0, lsl #11 │ │ │ │ ldrdeq pc, [r0, -r5] │ │ │ │ stmdavs r3, {r3, r6, r8, ip, sp, pc} │ │ │ │ teqpcc r8, r5, asr #17 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0xf820f7e8 │ │ │ │ + @ instruction: 0xf8c8f7e8 │ │ │ │ movwcs r2, #4608 @ 0x1200 │ │ │ │ smlabtcs r0, r5, r8, pc @ │ │ │ │ ldclt 1, cr6, [r8, #-140]! @ 0xffffff74 │ │ │ │ addpl pc, r0, r0, lsl #10 │ │ │ │ ldrdcc pc, [r0, -r0] │ │ │ │ @ instruction: 0xf04fb123 │ │ │ │ andcs r3, r0, #-1073741761 @ 0xc000003f │ │ │ │ @@ -41265,25 +41260,25 @@ │ │ │ │ ldrtlt r4, [r0], #-2822 @ 0xfffff4fa │ │ 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instruction: 0x861ce9d2 │ │ │ │ svceq 0x0000f1b8 │ │ │ │ @ instruction: 0xf8dfdd4b │ │ │ │ @ instruction: 0xf10090a4 │ │ │ │ mcrcc 3, 0, r0, cr4, cr8, {2} │ │ │ │ ldrbtmi r2, [r9], #1280 @ 0x500 │ │ │ │ - bleq 667cfc <__bss_end__@@Base+0x5c10c4> │ │ │ │ + bleq 667c84 <__bss_end__@@Base+0x5c10e4> │ │ │ │ and r9, r7, r1, lsl #6 │ │ │ │ @ instruction: 0xf8d96a47 │ │ │ │ addmi r1, pc, #8 │ │ │ │ strcc sp, [r1, #-8] │ │ │ │ eorsle r4, r8, r8, lsr #11 │ │ │ │ @ instruction: 0x1014f8da │ │ │ │ svceq 0x0004f856 │ │ │ │ @ instruction: 0xddf12900 │ │ │ │ - mcr2 7, 6, pc, cr8, cr13, {6} @ │ │ │ │ + mcr2 7, 3, pc, cr8, cr13, {6} @ │ │ │ │ @ instruction: 0xf9b04607 │ │ │ │ - bvs e6bbf4 <__bss_end__@@Base+0xdc4fbc> │ │ │ │ - ldcle 8, cr2, [pc, #-0] @ 2bbf0 │ │ │ │ + bvs e6bb7c <__bss_end__@@Base+0xdc4fdc> │ │ │ │ + ldcle 8, cr2, [pc, #-0] @ 2bb78 │ │ │ │ ldc 1, cr3, [sl, #96] @ 0x60 │ │ │ │ - blx 432802 <__bss_end__@@Base+0x38bbca> │ │ │ │ + blx 43278a <__bss_end__@@Base+0x38bbea> │ │ │ │ ldc 0, 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sl │ │ │ │ strdeq r1, [r3], -r6 │ │ │ │ + ldrdeq r1, [r3], -r6 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb82e60 <__bss_end__@@Base+0xfeadc228> │ │ │ │ + bl feb82de8 <__bss_end__@@Base+0xfeadc248> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - bmi 8afc28 <__bss_end__@@Base+0x808ff0> │ │ │ │ + bmi 8afbb0 <__bss_end__@@Base+0x809010> │ │ │ │ stmdami r2!, {r8, r9, sp} │ │ │ │ ldrbtmi r4, [sl], #-1566 @ 0xfffff9e2 │ │ │ │ ldrmi r4, [sp], -r1, lsr #18 │ │ │ │ ldmdapl r0, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf100680c │ │ │ │ @ instruction: 0xf5000110 │ │ │ │ andcc r5, r8, r8, lsl #1 │ │ │ │ @@ -41350,137 +41345,137 @@ │ │ │ │ eorcs pc, r3, r0, asr r8 @ │ │ │ │ andsvs r2, r4, r1, lsl #12 │ │ │ │ @ instruction: 0xf8404614 │ │ │ │ @ instruction: 0xf8415023 │ │ │ │ @ instruction: 0xf5035023 │ │ │ │ @ instruction: 0xf5b3638a │ │ │ │ mvnle r4, sl, lsl #30 │ │ │ │ - blmi 558104 <__bss_end__@@Base+0x4b14cc> │ │ │ │ + blmi 55808c <__bss_end__@@Base+0x4b14ec> │ │ │ │ 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│ - andeq r1, r3, lr, ror #17 │ │ │ │ + andeq ip, r2, sl, lsl #8 │ │ │ │ + andeq r0, r0, r0, lsl #5 │ │ │ │ + andeq r1, r3, ip, lsl r9 │ │ │ │ + andeq r1, r3, r4, ror #17 │ │ │ │ ldrdeq r1, [r3], -lr │ │ │ │ - andeq r1, r3, r6, asr #17 │ │ │ │ + andeq r1, r3, lr, asr #17 │ │ │ │ + @ instruction: 0x000318be │ │ │ │ + andeq r1, r3, r6, lsr #17 │ │ │ │ │ │ │ │ -0002bd0c : │ │ │ │ +0002bc94 : │ │ │ │ vcmpe.f64 d1, #0.0 │ │ │ │ vabs.f64 d0, d0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it mi │ │ │ │ vnegmi.f64 d0, d0 │ │ │ │ bx lr │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d15} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3896] @ 0xf38 │ │ │ │ - ldr.w r8, [pc, #1096] @ 2c180 │ │ │ │ + ldr.w r8, [pc, #1096] @ 2c108 │ │ │ │ sub sp, #100 @ 0x64 │ │ │ │ - ldr.w r2, [pc, #1096] @ 2c184 │ │ │ │ + ldr.w r2, [pc, #1096] @ 2c10c │ │ │ │ add r8, pc │ │ │ │ - ldr.w r3, [pc, #1092] @ 2c188 │ │ │ │ + ldr.w r3, [pc, #1092] @ 2c110 │ │ │ │ add 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[r2, #0] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 2c15c │ │ │ │ + beq.w 2c0e4 │ │ │ │ ldr r1, [r3, #0] │ │ │ │ str r1, [r2, #0] │ │ │ │ - ldr r2, [pc, #1008] @ (2c198 ) │ │ │ │ + ldr r2, [pc, #1008] @ (2c120 ) │ │ │ │ vmov.f64 d5, #96 @ 0x3f000000 0.5 │ │ │ │ vstr d13, [r3, #8] │ │ │ │ mov.w r8, #4416 @ 0x1140 │ │ │ │ movw lr, #4360 @ 0x1108 │ │ │ │ movs r1, #32 │ │ │ │ mov.w ip, #7 │ │ │ │ movw fp, #4408 @ 0x1138 │ │ │ │ ldr.w r2, [sl, r2] │ │ │ │ mul.w r8, r8, r4 │ │ │ │ mov.w r9, #0 │ │ │ │ add.w r4, r5, r8 │ │ │ │ add.w r0, r8, #20 │ │ │ │ add r0, r5 │ │ │ │ vldr d4, [r2] │ │ │ │ - ldr r2, [pc, #956] @ (2c19c ) │ │ │ │ + ldr r2, [pc, #956] @ (2c124 ) │ │ │ │ vdiv.f64 d6, d14, d4 │ │ │ │ add r2, pc │ │ │ │ vdiv.f64 d7, d15, d4 │ │ │ │ vadd.f64 d6, d6, d5 │ │ │ │ vadd.f64 d7, d7, d5 │ │ │ │ vcvt.s32.f64 s12, d6 │ │ │ │ vcvt.s32.f64 s14, d7 │ │ │ │ vstr s12, [r3, #16] │ │ │ │ vstr s14, [r3, #20] │ │ │ │ str.w r3, [r4, lr] │ │ │ │ str.w ip, [r4, #16] │ │ │ │ - bl 13d0c │ │ │ │ + bl 13de4 │ │ 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│ │ str.w r3, [r5, #1360] @ 0x550 │ │ │ │ movs r3, #0 │ │ │ │ str.w r3, [r8] │ │ │ │ - b.n 2bd7a │ │ │ │ + b.n 2bd02 │ │ │ │ ldr.w r3, [r9, #116] @ 0x74 │ │ │ │ mov r1, fp │ │ │ │ ldr r2, [sp, #8] │ │ │ │ movs r0, #3 │ │ │ │ str r3, [sp, #4] │ │ │ │ - bl 9754 │ │ │ │ + bl 9620 │ │ │ │ ldr r3, [sp, #4] │ │ │ │ adds r5, #1 │ │ │ │ str.w r0, [r3, r8] │ │ │ │ - b.n 2c008 │ │ │ │ - ldr r0, [pc, #124] @ (2c1dc ) │ │ │ │ + b.n 2bf90 │ │ │ │ + ldr r0, [pc, #124] @ (2c164 ) │ │ │ │ movs r2, #24 │ │ │ │ movs r1, #154 @ 0x9a │ │ │ │ add r0, pc │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ mov r3, r0 │ │ │ │ - b.n 2bda6 │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 2bd2e │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #201 @ 0xc9 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ - adds r6, r5, r1 │ │ │ │ + adds r6, r1, r1 │ │ │ │ movs r3, r0 │ │ │ │ - stmia r2!, {r3, r4, r5, r7} │ │ │ │ + stmia r3!, {r4, r5} │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - stmia r2!, {r1, r2, r3, r5, r7} │ │ │ │ + stmia r3!, {r1, r2, r5} │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r1, #10 │ │ │ │ + lsls r0, r0, #10 │ │ │ │ movs r0, r0 │ │ │ │ - adds r4, r2, r0 │ │ │ │ + asrs r4, r6, #31 │ │ │ │ movs r3, r0 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ - add.w r0, sl, #1 │ │ │ │ - asrs r0, r6, #29 │ │ │ │ + @ instruction: 0xf33e0001 │ │ │ │ + asrs r0, r2, #29 │ │ │ │ movs r3, r0 │ │ │ │ stc2 15, cr15, [r9, #-1020] @ 0xfffffc04 │ │ │ │ stc2l 15, cr15, [r3], #1020 @ 0x3fc │ │ │ │ - stmia r1!, {r2, r7} │ │ │ │ + stmia r1!, {r2, r3, r4, r5, r6, r7} │ │ │ │ movs r2, r0 │ │ │ │ ldc2 15, cr15, [r1, #1020]! @ 0x3fc │ │ │ │ - bic.w r0, r6, #1 │ │ │ │ - udf #24 │ │ │ │ + @ instruction: 0xf25a0001 │ │ │ │ + udf #8 │ │ │ │ + movs r1, r0 │ │ │ │ + b.n 2c174 │ │ │ │ movs r1, r0 │ │ │ │ - b.n 2c20c │ │ │ │ + b.n 2c600 │ │ │ │ movs r1, r0 │ │ │ │ - vext.8 d16, d10, d1, #0 │ │ │ │ - vext.8 d16, d6, d1, #0 │ │ │ │ - asrs r2, r5, #18 │ │ │ │ + @ instruction: 0xf22a0001 │ │ │ │ + asrs r2, r1, #18 │ │ │ │ movs r3, r0 │ │ │ │ - stcl 0, cr0, [ip, #4] │ │ │ │ - b.n 2bf44 │ │ │ │ + and.w r0, r0, #1 │ │ │ │ + b.n 2be8c │ │ │ │ movs r2, r0 │ │ │ │ - stcl 0, cr0, [r0, #4] │ │ │ │ + vext.8 d16, d4, d1, #0 │ │ │ │ @ instruction: 0xfa45ffff │ │ │ │ - ldcl 0, cr0, [r2, #-4]! │ │ │ │ + vaddl.s32 q0, d6, d1 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3920] @ 0xf50 │ │ │ │ - ldr r1, [pc, #304] @ (2c328 ) │ │ │ │ + ldr r1, [pc, #304] @ (2c2b0 ) │ │ │ │ sub sp, #132 @ 0x84 │ │ │ │ - ldr r2, [pc, #304] @ (2c32c ) │ │ │ │ + ldr r2, [pc, #304] @ (2c2b4 ) │ │ │ │ add r1, pc │ │ │ │ - ldr.w r9, [pc, #304] @ 2c330 │ │ │ │ - ldr r3, [pc, #304] @ (2c334 ) │ │ │ │ + ldr.w r9, [pc, #304] @ 2c2b8 │ │ │ │ + ldr r3, [pc, #304] @ (2c2bc ) │ │ │ │ add r9, pc │ │ │ │ ldr r2, [r1, r2] │ │ │ │ ldr r2, [r2, #0] │ │ │ │ str r2, [sp, #124] @ 0x7c │ │ │ │ mov.w r2, #0 │ │ │ │ ldr.w r8, [r9, r3] │ │ │ │ ldr.w r4, [r8] │ │ │ │ - cbz r4, 2c266 │ │ │ │ + cbz r4, 2c1ee │ │ │ │ add r5, sp, #8 │ │ │ │ - vldr d8, [pc, #260] @ 2c320 │ │ │ │ + vldr d8, [pc, #260] @ 2c2a8 │ │ │ │ movs r7, #1 │ │ │ │ ldr r0, [r4, #12] │ │ │ │ mov r1, r4 │ │ │ │ - bl 3af50 │ │ │ │ + bl 3aed8 │ │ │ │ ldr r6, [r4, #12] │ │ │ │ ldr r0, [r4, #20] │ │ │ │ mov r1, r5 │ │ │ │ - bl 13552 │ │ │ │ - cbz r0, 2c260 │ │ │ │ + bl 13750 │ │ │ │ + cbz r0, 2c1e8 │ │ │ │ ldr r3, [sp, #8] │ │ │ │ cmp r3, #11 │ │ │ │ - bhi.n 2c22a │ │ │ │ + bhi.n 2c1b2 │ │ │ │ tbb [pc, r3] │ │ │ │ movs r4, #36 @ 0x24 │ │ │ │ lsls r4, r4, #24 │ │ │ │ lsls r6, r0, #24 │ │ │ │ strh r4, [r2, r1] │ │ │ │ - ldr r3, [pc, #316] @ (2c384 ) │ │ │ │ + ldr r3, [pc, #316] @ (2c30c ) │ │ │ │ adds r6, #66 @ 0x42 │ │ │ │ cmp r3, #3 │ │ │ │ - bne.n 2c22a │ │ │ │ + bne.n 2c1b2 │ │ │ │ mov r0, r6 │ │ │ │ - bl 46a24 │ │ │ │ + bl 469ac │ │ │ │ ldr r0, [r4, #20] │ │ │ │ mov r1, r5 │ │ │ │ - bl 13552 │ │ │ │ + bl 13750 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.n 2c234 │ │ │ │ + bne.n 2c1bc │ │ │ │ ldr r4, [r4, #0] │ │ │ │ cmp r4, #0 │ │ │ │ - bne.n 2c220 │ │ │ │ - ldr r2, [pc, #208] @ (2c338 ) │ │ │ │ - ldr r3, [pc, #192] @ (2c32c ) │ │ │ │ + bne.n 2c1a8 │ │ │ │ + ldr r2, [pc, #208] @ (2c2c0 ) │ │ │ │ + ldr r3, [pc, #192] @ (2c2b4 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #124] @ 0x7c │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.w 2cd70 │ │ │ │ + bne.w 2ccf8 │ │ │ │ add sp, #132 @ 0x84 │ │ │ │ vpop {d8} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ ldrd r0, r2, [r4, #24] │ │ │ │ cmp r2, #0 │ │ │ │ it ne │ │ │ │ cmpne r0, #0 │ │ │ │ ite eq │ │ │ │ moveq r0, #1 │ │ │ │ movne r0, #0 │ │ │ │ - beq.n 2c22a │ │ │ │ + beq.n 2c1b2 │ │ │ │ cmp r3, #0 │ │ │ │ - beq.n 2c318 │ │ │ │ + beq.n 2c2a0 │ │ │ │ cmp r3, #1 │ │ │ │ - beq.w 2c5d8 │ │ │ │ + beq.w 2c560 │ │ │ │ mov r0, r6 │ │ │ │ - bl 46940 │ │ │ │ - b.n 2c22a │ │ │ │ + bl 468c8 │ │ │ │ + b.n 2c1b2 │ │ │ │ add.w r3, r6, #4096 @ 0x1000 │ │ │ │ movs r1, #0 │ │ │ │ mov r0, r6 │ │ │ │ ldr.w r3, [r3, #316] @ 0x13c │ │ │ │ blx r3 │ │ │ │ ldr.w r4, [r8] │ │ │ │ cmp r4, #0 │ │ │ │ - bne.n 2c220 │ │ │ │ - b.n 2c266 │ │ │ │ + bne.n 2c1a8 │ │ │ │ + b.n 2c1ee │ │ │ │ ldr r0, [r4, #96] @ 0x60 │ │ │ │ mov r1, r4 │ │ │ │ str r0, [sp, #0] │ │ │ │ mov r0, r6 │ │ │ │ ldrd r2, r3, [sp, #12] │ │ │ │ - bl 46b00 │ │ │ │ - b.n 2c22a │ │ │ │ + bl 46a88 │ │ │ │ + b.n 2c1b2 │ │ │ │ ldr r0, [r4, #32] │ │ │ │ - bl 4d68 │ │ │ │ - b.n 2c22a │ │ │ │ + bl 4d00 │ │ │ │ + b.n 2c1b2 │ │ │ │ vstr d8, [r4, #24] │ │ │ │ - b.n 2c22a │ │ │ │ + b.n 2c1b2 │ │ │ │ str r7, [r4, #24] │ │ │ │ - b.n 2c22a │ │ │ │ + b.n 2c1b2 │ │ │ │ ldr r3, [r4, #24] │ │ │ │ ldr.w sl, [sp, #20] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.n 2c22a │ │ │ │ + beq.n 2c1b2 │ │ │ │ ldr r3, [r4, #28] │ │ │ │ - cbnz r3, 2c300 │ │ │ │ + cbnz r3, 2c288 │ │ │ │ cmp.w sl, #100 @ 0x64 │ │ │ │ itt eq │ │ │ │ moveq r3, #1 │ │ │ │ streq r3, [r4, #28] │ │ │ │ - b.n 2c22a │ │ │ │ + b.n 2c1b2 │ │ │ │ mov r0, r4 │ │ │ │ - bl 44de0 │ │ │ │ - cbz r0, 2c33c │ │ │ │ + bl 44d68 │ │ │ │ + cbz r0, 2c2c4 │ │ │ │ cmn.w sl, #25 │ │ │ │ - bne.w 2c5f0 │ │ │ │ + bne.w 2c578 │ │ │ │ mov r0, r4 │ │ │ │ - bl 44df4 │ │ │ │ - b.n 2c22a │ │ │ │ + bl 44d7c │ │ │ │ + b.n 2c1b2 │ │ │ │ mov r0, r6 │ │ │ │ - bl 46a10 │ │ │ │ - b.n 2c22a │ │ │ │ + bl 46998 │ │ │ │ + b.n 2c1b2 │ │ │ │ ... │ │ │ │ - bkpt 0x0002 │ │ │ │ + bkpt 0x007a │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - pop {r1, r3, r4, r5, r6, r7, pc} │ │ │ │ + bkpt 0x0072 │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r5, #11 │ │ │ │ + lsls r0, r4, #11 │ │ │ │ movs r0, r0 │ │ │ │ - pop {r1, r4, r7, pc} │ │ │ │ + bkpt 0x000a │ │ │ │ movs r2, r0 │ │ │ │ add.w sl, sl, #36 @ 0x24 │ │ │ │ cmp.w sl, #160 @ 0xa0 │ │ │ │ - bhi.w 2c616 │ │ │ │ - add r3, pc, #8 @ (adr r3, 2c354 ) │ │ │ │ + bhi.w 2c59e │ │ │ │ + add r3, pc, #8 @ (adr r3, 2c2dc ) │ │ │ │ ldr.w sl, [r3, sl, lsl #2] │ │ │ │ add r3, sl │ │ │ │ bx r3 │ │ │ │ nop │ │ │ │ lsls r5, r5, #20 │ │ │ │ movs r0, r0 │ │ │ │ lsls r1, r4, #20 │ │ │ │ @@ -42233,485 +42229,480 @@ │ │ │ │ lsls r1, r6, #23 │ │ │ │ movs r0, r0 │ │ │ │ lsls r3, r0, #11 │ │ │ │ movs r0, r0 │ │ │ │ lsls r1, r0, #22 │ │ │ │ movs r0, r0 │ │ │ │ ldrd sl, fp, [sp, #12] │ │ │ │ - blx 32bc <__time64@plt> │ │ │ │ + blx 3274 <__time64@plt> │ │ │ │ mov r1, r4 │ │ │ │ str r0, [sp, #0] │ │ │ │ mov r3, fp │ │ │ │ mov r2, sl │ │ │ │ mov r0, r6 │ │ │ │ - bl 25cbc │ │ │ │ - b.n 2c22a │ │ │ │ + bl 25c44 │ │ │ │ + b.n 2c1b2 │ │ │ │ mov r1, sl │ │ │ │ mov r0, r4 │ │ │ │ add.w sl, sp, #24 │ │ │ │ - bl 44e0c │ │ │ │ + bl 44d94 │ │ │ │ movs r2, #100 @ 0x64 │ │ │ │ mov r1, sl │ │ │ │ mov r0, r4 │ │ │ │ - bl 44ec8 │ │ │ │ + bl 44e50 │ │ │ │ cmp r0, #0 │ │ │ │ - beq.w 2c22a │ │ │ │ + beq.w 2c1b2 │ │ │ │ mov r1, sl │ │ │ │ mov r0, r4 │ │ │ │ - bl 26a60 │ │ │ │ - b.n 2c22a │ │ │ │ - ldr.w r1, [pc, #1176] @ 2cab0 │ │ │ │ + bl 269e8 │ │ │ │ + b.n 2c1b2 │ │ │ │ + ldr.w r1, [pc, #1176] @ 2ca38 │ │ │ │ mov r0, r4 │ │ │ │ add r1, pc │ │ │ │ - bl 40234 │ │ │ │ - b.n 2c22a │ │ │ │ + bl 401bc │ │ │ │ + b.n 2c1b2 │ │ │ │ mov r0, r6 │ │ │ │ - bl 23700 │ │ │ │ + bl 23688 │ │ │ │ mov r0, r6 │ │ │ │ - bl 236c8 │ │ │ │ + bl 23650 │ │ │ │ mov r0, r6 │ │ │ │ - bl 23428 │ │ │ │ + bl 233b0 │ │ │ │ mov r0, r6 │ │ │ │ - bl 23274 │ │ │ │ + bl 231fc │ │ │ │ mov r0, r6 │ │ │ │ - bl 23688 │ │ │ │ + bl 23610 │ │ │ │ mov.w r3, #32768 @ 0x8000 │ │ │ │ str.w r3, [r6, #640] @ 0x280 │ │ │ │ - b.n 2c22a │ │ │ │ + b.n 2c1b2 │ │ │ │ mov r0, r6 │ │ │ │ - bl 23700 │ │ │ │ + bl 23688 │ │ │ │ mov r0, r6 │ │ │ │ - bl 236c8 │ │ │ │ + bl 23650 │ │ │ │ mov r0, r6 │ │ │ │ - bl 23274 │ │ │ │ + bl 231fc │ │ │ │ mov r0, r6 │ │ │ │ - bl 23428 │ │ │ │ + bl 233b0 │ │ │ │ mov r0, r6 │ │ │ │ - bl 23688 │ │ │ │ + bl 23610 │ │ │ │ movw r3, #6553 @ 0x1999 │ │ │ │ str.w r3, [r6, #640] @ 0x280 │ │ │ │ - b.n 2c22a │ │ │ │ + b.n 2c1b2 │ │ │ │ mov r0, r6 │ │ │ │ - bl 23444 │ │ │ │ + bl 233cc │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 2cd26 │ │ │ │ + bne.w 2ccae │ │ │ │ ldr.w r3, [r6, #640] @ 0x280 │ │ │ │ add.w r3, r3, #512 @ 0x200 │ │ │ │ cmp.w r3, #32768 @ 0x8000 │ │ │ │ it ge │ │ │ │ movge.w r3, #32768 @ 0x8000 │ │ │ │ str.w r3, [r6, #640] @ 0x280 │ │ │ │ - b.n 2c22a │ │ │ │ + b.n 2c1b2 │ │ │ │ mov r0, r6 │ │ │ │ - bl 23444 │ │ │ │ + bl 233cc │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 2cd3e │ │ │ │ + bne.w 2ccc6 │ │ │ │ ldr.w r3, [r6, #640] @ 0x280 │ │ │ │ movw r2, #6552 @ 0x1998 │ │ │ │ sub.w r3, r3, #512 @ 0x200 │ │ │ │ cmp r3, r2 │ │ │ │ it le │ │ │ │ movwle r3, #6553 @ 0x1999 │ │ │ │ str.w r3, [r6, #640] @ 0x280 │ │ │ │ - b.n 2c22a │ │ │ │ + b.n 2c1b2 │ │ │ │ mov r0, r6 │ │ │ │ - bl 44994 │ │ │ │ + bl 4491c │ │ │ │ clz r1, r0 │ │ │ │ mov r0, r6 │ │ │ │ lsrs r1, r1, #5 │ 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-43103,45 +43094,45 @@ │ │ │ │ bicpl.w r3, r3, #65536 @ 0x10000 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ ite gt │ │ │ │ orrgt.w r3, r3, #131072 @ 0x20000 │ │ │ │ bicle.w r3, r3, #131072 @ 0x20000 │ │ │ │ str.w r3, [r0, #776] @ 0x308 │ │ │ │ bx lr │ │ │ │ - ble.n 2cf76 │ │ │ │ - ldr.w ip, [pc, #92] @ 2d014 │ │ │ │ + ble.n 2cefe │ │ │ │ + ldr.w ip, [pc, #92] @ 2cf9c │ │ │ │ vldr d5, [r2, #392] @ 0x188 │ │ │ │ ldr.w r1, [r1, ip] │ │ │ │ vldr d6, [r1] │ │ │ │ vmls.f64 d7, d5, d6 │ │ │ │ vcmpe.f64 d7, d4 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it mi │ │ │ │ vmovmi.f64 d7, d4 │ │ │ │ vstr d7, [r0, #728] @ 0x2d8 │ │ │ │ - b.n 2cf76 │ │ │ │ - bpl.n 2cf3a │ │ │ │ - ldr.w ip, [pc, #48] @ 2d014 │ │ │ │ + b.n 2cefe │ │ │ │ + bpl.n 2cec2 │ │ │ │ + ldr.w ip, [pc, #48] @ 2cf9c │ │ │ │ vldr d4, [r2, #352] @ 0x160 │ │ │ │ ldr.w r4, [r1, ip] │ │ │ │ vldr d5, [r4] │ │ │ │ vmls.f64 d6, d4, d5 │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it le │ │ │ │ vmovle.f64 d7, d6 │ │ │ │ vstr d7, [r0, #712] @ 0x2c8 │ │ │ │ - b.n 2cf3a │ │ │ │ + b.n 2cec2 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ subs r7, #195 @ 0xc3 │ │ │ │ - cbz r4, 2d014 │ │ │ │ + cbz r4, 2cfba │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ mov r3, r0 │ │ │ │ movs r0, #0 │ │ │ │ ldr.w r2, [r3, #812] @ 0x32c │ │ │ │ vldr d7, [r3, #736] @ 0x2e0 │ │ │ │ vldr d5, [r2, #400] @ 0x190 │ │ │ │ vldr d6, [r2, #376] @ 0x178 │ │ │ │ @@ -43149,15 +43140,15 @@ │ │ │ │ vcmp.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it gt │ │ │ │ vmovgt.f64 d7, d6 │ │ │ │ vstr d7, [r3, #736] @ 0x2e0 │ │ │ │ bx lr │ │ │ │ mov r3, r0 │ │ │ │ - vldr d6, [pc, #40] @ 2d070 │ │ │ │ + vldr d6, [pc, #40] @ 2cff8 │ │ │ │ movs r0, #0 │ │ │ │ ldr.w r2, [r3, #812] @ 0x32c │ │ │ │ vldr d7, [r3, #736] @ 0x2e0 │ │ │ │ vldr d5, [r2, #400] @ 0x190 │ │ │ │ vsub.f64 d7, d7, d5 │ │ │ │ vcmp.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ @@ -43214,26 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r0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - beq.w 2d32a │ │ │ │ + beq.w 2d2b2 │ │ │ │ mov r1, sp │ │ │ │ add r0, sp, #8 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ vldr d11, [sp] │ │ │ │ vldr d9, [sp, #8] │ │ │ │ vmul.f64 d1, d11, d12 │ │ │ │ vmul.f64 d13, d11, d14 │ │ │ │ vmla.f64 d1, d9, d14 │ │ │ │ vmov.f64 d7, #112 @ 0x3f800000 1.0 │ │ │ │ vadd.f64 d6, d1, d1 │ │ │ │ vabs.f64 d5, d6 │ │ │ │ vcmpe.f64 d5, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it le │ │ │ │ vnegle.f64 d7, d6 │ │ │ │ - ble.n 2d1ec │ │ │ │ + ble.n 2d174 │ │ │ │ vcmpe.f64 d6, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bgt.n 2d1e8 │ │ │ │ - bmi.n 2d1ec │ │ │ │ - vldr d7, [pc, #428] @ 2d388 │ │ │ │ + bgt.n 2d170 │ │ │ │ + bmi.n 2d174 │ │ │ │ + vldr d7, [pc, #428] @ 2d310 │ │ │ │ vmul.f64 d15, d15, d7 │ │ │ │ vmul.f64 d8, d15, d10 │ │ │ │ - b.n 2d206 │ │ │ │ + b.n 2d18e │ │ │ │ vmov.f64 d7, #240 @ 0xbf800000 -1.0 │ │ │ │ vabs.f64 d6, d1 │ │ │ │ vmov.f64 d5, #96 @ 0x3f000000 0.5 │ │ │ │ vcmpe.f64 d6, d5 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.n 2d1de │ │ │ │ + bmi.n 2d166 │ │ │ │ vmul.f64 d8, d8, d7 │ │ │ │ vmul.f64 d8, d8, d10 │ │ │ │ vmls.f64 d13, d12, d9 │ │ │ │ vmov.f64 d7, #8 @ 0x40400000 3.0 │ │ │ │ vdiv.f64 d14, d13, d7 │ │ │ │ vmov.f64 d7, #112 @ 0x3f800000 1.0 │ │ │ │ vabs.f64 d6, d14 │ │ │ │ vcmpe.f64 d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it le │ │ │ │ vnegle.f64 d12, d14 │ │ │ │ - ble.n 2d242 │ │ │ │ + ble.n 2d1ca │ │ │ │ vcmpe.f64 d14, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bgt.w 2d338 │ │ │ │ - bmi.w 2d342 │ │ │ │ - vldr d12, [pc, #332] @ 2d388 │ │ │ │ - vldr d14, [pc, #336] @ 2d390 │ │ │ │ + bgt.w 2d2c0 │ │ │ │ + bmi.w 2d2ca │ │ │ │ + vldr d12, [pc, #332] @ 2d310 │ │ │ │ + vldr d14, [pc, #336] @ 2d318 │ │ │ │ vmov.f64 d0, d13 │ │ │ │ - blx 33f0 │ │ │ │ - vldr d7, [pc, #332] @ 2d398 │ │ │ │ - vldr d3, [pc, #336] @ 2d3a0 │ │ │ │ + blx 3398 │ │ │ │ + vldr d7, [pc, #332] @ 2d320 │ │ │ │ + vldr d3, [pc, #336] @ 2d328 │ │ │ │ vcmpe.f64 d0, d7 │ │ │ │ vmul.f64 d3, d12, d3 │ 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[pc, #284] @ 2d350 │ │ │ │ vcmpe.f64 d6, d5 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it le │ │ │ │ movle r0, #0 │ │ │ │ - ble.n 2d2d2 │ │ │ │ + ble.n 2d25a │ │ │ │ vabs.f64 d14, d14 │ │ │ │ vmov.f64 d6, #96 @ 0x3f000000 0.5 │ │ │ │ vcmpe.f64 d14, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ ite gt │ │ │ │ movgt r0, #1 │ │ │ │ movle r0, #0 │ │ │ │ vmul.f64 d3, d10, d3 │ │ │ │ - b.n 2d302 │ │ │ │ + b.n 2d28a │ │ │ │ vcmpe.f64 d13, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bgt.n 2d2bc │ │ │ │ + bgt.n 2d244 │ │ │ │ vcmpe.f64 d13, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.n 2d2bc │ │ │ │ - vldr d6, [pc, #160] @ 2d390 │ │ │ │ + bmi.n 2d244 │ │ │ │ + vldr d6, [pc, #160] @ 2d318 │ │ │ │ vmul.f64 d6, d6, d3 │ │ │ │ - vldr d5, [pc, #200] @ 2d3c0 │ │ │ │ + vldr d5, [pc, #200] @ 2d348 │ │ │ │ movs r0, #0 │ │ │ │ vdiv.f64 d3, d6, d5 │ │ │ │ vmul.f64 d3, d3, d10 │ │ │ │ vmul.f64 d7, d9, d3 │ │ │ │ vmul.f64 d3, d11, d3 │ │ │ │ vmla.f64 d3, d9, d8 │ │ │ │ movs r2, #0 │ │ │ │ @@ -43359,39 +43350,39 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r0, r0 │ │ │ │ - bpl.n 2dee2 │ │ │ │ - vldr d3, [pc, #476] @ 2e0b0 │ │ │ │ + bpl.n 2de6a │ │ │ │ + vldr d3, [pc, #476] @ 2e038 │ │ │ │ vsub.f64 d4, d13, d4 │ │ │ │ vmul.f64 d5, d5, d3 │ │ │ │ vmls.f64 d2, d5, d4 │ │ │ │ vmov.f64 d5, #96 @ 0x3f000000 0.5 │ │ │ │ - vldr d11, [pc, #464] @ 2e0b8 │ │ │ │ + vldr d11, [pc, #464] @ 2e040 │ │ │ │ vmul.f64 d6, d6, d5 │ │ │ │ vmla.f64 d2, d6, d12 │ │ │ │ vcmpe.f64 d2, d11 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.w 2ea1a │ │ │ │ + ble.w 2e9a2 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vstr d11, [sl, #16] │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.w 2e0fc │ │ │ │ - ldr r0, [pc, #456] @ (2e0d8 ) │ │ │ │ + ble.w 2e084 │ │ │ │ + ldr r0, [pc, #456] @ (2e060 ) │ │ │ │ add r0, pc │ │ │ │ - b.n 2e03e │ │ │ │ + b.n 2dfc6 │ │ │ │ cmp r2, #0 │ │ │ │ - bne.w 2e09a │ │ │ │ + bne.w 2e022 │ │ │ │ ldr r2, [r4, #0] │ │ │ │ vldr d6, [r4, #8] │ │ │ │ cmp r2, #0 │ │ │ │ - bne.w 2db1a │ │ │ │ + bne.w 2daa2 │ │ │ │ vldr d7, [r4, #16] │ │ │ │ - vldr d4, [pc, #396] @ 2e0b8 │ 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│ │ mov r2, r7 │ │ │ │ mov r1, sl │ │ │ │ mov r0, r9 │ │ │ │ - bl abf4 │ │ │ │ + bl abc6 │ │ │ │ mov r2, r8 │ │ │ │ mov r1, r7 │ │ │ │ mov r0, r8 │ │ │ │ - bl ab28 │ │ │ │ + bl aa1e │ │ │ │ mov r2, r7 │ │ │ │ ldr r1, [sp, #16] │ │ │ │ mov r0, r9 │ │ │ │ - bl abf4 │ │ │ │ + bl abc6 │ │ │ │ mov r1, r7 │ │ │ │ mov r2, r8 │ │ │ │ mov r0, r8 │ │ │ │ - bl ab28 │ │ │ │ + bl aa1e │ │ │ │ ldr.w ip, [r4, #32] │ │ │ │ ldrd r3, r7, [sp, #4] │ │ │ │ vstr d9, [r3] │ │ │ │ vstr d10, [r3, #8] │ │ │ │ vstr d8, [r3, #16] │ │ │ │ ldmia.w r8!, {r0, r1, r2, r3} │ │ │ │ stmia r7!, {r0, r1, r2, r3} │ │ │ │ ldmia.w r8, {r0, r1} │ │ │ │ stmia.w r7, {r0, r1} │ │ │ │ cmp.w ip, #0 │ │ │ │ - bne.n 2e28a │ │ │ │ + bne.n 2e212 │ │ │ │ ldr r3, [r4, #36] @ 0x24 │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 2e67c │ │ │ │ + beq.w 2e604 │ │ │ │ vldr d6, [r6, #624] @ 0x270 │ │ │ │ vldr d7, [r6, #600] @ 0x258 │ │ │ │ vcmpe.f64 d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.w 2e432 │ │ │ │ - vldr d7, [pc, #416] @ 2e440 │ │ │ │ + ble.w 2e3ba │ │ │ │ + vldr d7, [pc, #416] @ 2e3c8 │ │ │ │ vldr d6, [r5, #480] @ 0x1e0 │ │ │ │ vcmpe.f64 d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.w 2e432 │ │ │ │ - ldr r0, [pc, #420] @ (2e458 ) │ │ │ │ + ble.w 2e3ba │ │ │ │ + ldr r0, [pc, #420] @ (2e3e0 ) │ │ │ │ add r0, pc │ │ │ │ - b.n 2e03e │ │ │ │ + b.n 2dfc6 │ │ │ │ vldr d6, [r4, #8] │ │ │ │ - b.n 2db6a │ │ │ │ + b.n 2daf2 │ │ │ │ ldr.w r3, [r5, #812] @ 0x32c │ │ │ │ - vldr d2, [pc, #388] @ 2e448 │ │ │ │ + vldr d2, [pc, #388] @ 2e3d0 │ │ │ │ vldr d3, [r3, #368] @ 0x170 │ │ │ │ vmul.f64 d3, d3, d2 │ │ │ │ vmla.f64 d4, d3, d5 │ │ │ │ vcmpe.f64 d4, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it le │ │ │ │ vmovle.f64 d7, d4 │ │ │ │ vstr d7, [r4, #24] │ │ │ │ - b.n 2db6a │ │ │ │ + b.n 2daf2 │ │ │ │ vcmpe.f64 d4, d15 │ │ │ │ vstr d15, [r8, #16] │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.w 2e034 │ │ │ │ + bmi.w 2dfbc │ │ │ │ movs r3, #0 │ │ │ │ str r3, [r4, #32] │ │ │ │ - b.n 2dddc │ │ │ │ + b.n 2dd64 │ │ │ │ add.w lr, r6, #624 @ 0x270 │ │ │ │ add.w sl, sp, #216 @ 0xd8 │ │ │ │ mov ip, sl │ │ │ │ vldr d6, [r6, #688] @ 0x2b0 │ │ │ │ ldmia.w lr!, {r0, r1, r2, r3} │ │ │ │ stmia.w ip!, {r0, r1, r2, r3} │ │ │ │ mov r2, sl │ │ │ │ ldmia.w lr, {r0, r1} │ │ │ │ stmia.w ip, {r0, r1} │ │ │ │ mov r1, fp │ │ │ │ mov r0, sl │ │ │ │ vldr d7, [sl, #16] │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ vstr d7, [sl, #16] │ │ │ │ - bl b364 │ │ │ │ - vldr d6, [pc, #284] @ 2e450 │ │ │ │ + bl b58c │ │ │ │ + vldr d6, [pc, #284] @ 2e3d8 │ │ │ │ vldr d7, [sl, #16] │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.w 2e4e8 │ │ │ │ + bpl.w 2e470 │ │ │ │ vldr d10, [r6, #704] @ 0x2c0 │ │ │ │ movs r3, #0 │ │ │ │ - vldr d11, [pc, #236] @ 2e438 │ │ │ │ + vldr d11, [pc, #236] @ 2e3c0 │ │ │ │ str r3, [r4, #32] │ │ │ │ - b.n 2dd22 │ │ │ │ + b.n 2dcaa │ │ │ │ add.w lr, r6, #600 @ 0x258 │ │ │ │ add.w sl, sp, #216 @ 0xd8 │ │ │ │ mov ip, sl │ │ │ │ vldr d6, [r6, #680] @ 0x2a8 │ │ │ │ ldmia.w lr!, {r0, r1, r2, r3} │ │ │ │ stmia.w ip!, {r0, r1, r2, r3} │ │ │ │ mov r2, sl │ │ │ │ ldmia.w lr, {r0, r1} │ │ │ │ stmia.w ip, {r0, r1} │ │ │ │ mov r1, fp │ │ │ │ mov r0, sl │ │ │ │ vldr d7, [sl, #16] │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ vstr d7, [sl, #16] │ │ │ │ - bl b364 │ │ │ │ - vldr d6, [pc, #200] @ 2e450 │ │ │ │ + bl b58c │ │ │ │ + vldr d6, [pc, #200] @ 2e3d8 │ │ │ │ vldr d7, [sl, #16] │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.w 2e51a │ │ │ │ + bpl.w 2e4a2 │ │ │ │ movs r3, #0 │ │ │ │ vldr d13, [r6, #696] @ 0x2b8 │ │ │ │ - vldr d12, [pc, #148] @ 2e438 │ │ │ │ + vldr d12, [pc, #148] @ 2e3c0 │ │ │ │ str r3, [r4, #40] @ 0x28 │ │ │ │ - b.n 2dd6e │ │ │ │ + b.n 2dcf6 │ │ │ │ add.w sl, sp, #216 @ 0xd8 │ │ │ │ add.w lr, r6, #600 @ 0x258 │ │ │ │ mov ip, sl │ │ │ │ vldr d6, [r6, #680] @ 0x2a8 │ │ │ │ ldmia.w lr!, {r0, r1, r2, r3} │ │ │ │ stmia.w ip!, {r0, r1, r2, r3} │ │ │ │ mov r2, sl │ │ │ │ @@ -44686,294 +44677,294 @@ │ │ │ │ stmia.w ip, {r0, r1} │ │ │ │ mov r1, fp │ │ │ │ mov r0, sl │ │ │ │ vstr d7, [sl, #8] │ │ │ │ vldr d7, [sl, #16] │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ vstr d7, [sl, #16] │ │ │ │ - bl b364 │ │ │ │ - vldr d6, [pc, #100] @ 2e450 │ │ │ │ + bl b58c │ │ │ │ + vldr d6, [pc, #100] @ 2e3d8 │ │ │ │ vldr d7, [sl, #16] │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.w 2e54c │ │ │ │ + bpl.w 2e4d4 │ │ │ │ vldr d7, [r6, #696] @ 0x2b8 │ │ │ │ movs r3, #0 │ │ │ │ - vldr d8, [pc, #52] @ 2e438 │ │ │ │ + vldr d8, [pc, #52] @ 2e3c0 │ │ │ │ str r3, [r4, #36] @ 0x24 │ │ │ │ vstr d7, [sp, #48] @ 0x30 │ │ │ │ - b.n 2ddba │ │ │ │ - vldr d2, [pc, #40] @ 2e438 │ │ │ │ + b.n 2dd42 │ │ │ │ + vldr d2, [pc, #40] @ 2e3c0 │ │ │ │ ldr r0, [sp, #4] │ │ │ │ vmov.f64 d1, d2 │ │ │ │ vmov.f64 d0, d2 │ │ │ │ - bl ab18 │ │ │ │ - vldr d2, [pc, #20] @ 2e438 │ │ │ │ + bl a9e0 │ │ │ │ + vldr d2, [pc, #20] @ 2e3c0 │ │ │ │ ldr r0, [sp, #8] │ │ │ │ vmov.f64 d1, d2 │ │ │ │ vmov.f64 d0, d2 │ │ │ │ - bl ab18 │ │ │ │ + bl a9e0 │ │ │ │ movs r0, #0 │ │ │ │ - b.n 2e03e │ │ │ │ + b.n 2dfc6 │ │ │ │ nop │ │ │ │ ... │ │ │ │ add pc, r0 │ │ │ │ - ldr r2, [pc, #924] @ (2e7e0 ) │ │ │ │ + ldr r2, [pc, #924] @ (2e768 ) │ │ │ │ ldrsb r0, [r3, r4] │ │ │ │ subs r7, #214 @ 0xd6 │ │ │ │ ldmia r4!, {r0, r2, r3, r6, r7} │ │ │ │ ldmia r4!, {r2, r3, r6, r7} │ │ │ │ ldmia r4!, {r2, r3, r6, r7} │ │ │ │ subs r7, #236 @ 0xec │ │ │ │ add r1, sp, #1008 @ 0x3f0 │ │ │ │ - bcs.n 2e438 │ │ │ │ + bcs.n 2e3c0 │ │ │ │ str r5, [r1, #36] @ 0x24 │ │ │ │ subs r7, #80 @ 0x50 │ │ │ │ - ldmia r6!, {r2, r4, r7} │ │ │ │ + beq.n 2e374 │ │ │ │ movs r1, r0 │ │ │ │ vldr d7, [r6, #696] @ 0x2b8 │ │ │ │ vmov.f64 d5, #248 @ 0xbfc00000 -1.5 │ │ │ │ vldr d4, [sp, #48] @ 0x30 │ │ │ │ vldr d6, [r6, #440] @ 0x1b8 │ │ │ │ vldr d3, [r6, #664] @ 0x298 │ │ │ │ vcmpe.f64 d7, d4 │ │ │ │ vmul.f64 d6, d6, d5 │ │ │ │ vldr d5, [r6, #648] @ 0x288 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bls.w 2ead6 │ │ │ │ + bls.w 2ea5e │ │ │ │ vmov.f64 d4, #96 @ 0x3f000000 0.5 │ │ │ │ vldr d2, [sp, #48] @ 0x30 │ │ │ │ vmul.f64 d4, d3, d4 │ │ │ │ - vldr d3, [pc, #676] @ 2e738 │ │ │ │ + vldr d3, [pc, #676] @ 2e6c0 │ │ │ │ vsub.f64 d7, d7, d2 │ │ │ │ vcmpe.f64 d2, d3 │ │ │ │ vnmul.f64 d7, d4, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.n 2e4b6 │ │ │ │ + bpl.n 2e43e │ │ │ │ vsub.f64 d3, d2, d3 │ │ │ │ - vldr d2, [pc, #660] @ 2e740 │ │ │ │ + vldr d2, [pc, #660] @ 2e6c8 │ │ │ │ vmul.f64 d4, d4, d2 │ │ │ │ vmls.f64 d7, d4, d3 │ │ │ │ vmov.f64 d4, #96 @ 0x3f000000 0.5 │ │ │ │ - vldr d11, [pc, #652] @ 2e748 │ │ │ │ + vldr d11, [pc, #652] @ 2e6d0 │ │ │ │ vmul.f64 d5, d5, d4 │ │ │ │ vmla.f64 d7, d5, d8 │ │ │ │ vcmpe.f64 d7, d11 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.w 2e686 │ │ │ │ + ble.w 2e60e │ │ │ │ vcmpe.f64 d6, #0.0 │ │ │ │ vstr d11, [r3, #16] │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.w 2eae6 │ │ │ │ - ldr r0, [pc, #620] @ (2e750 ) │ │ │ │ + ble.w 2ea6e │ │ │ │ + ldr r0, [pc, #620] @ (2e6d8 ) │ │ │ │ add r0, pc │ │ │ │ - b.n 2e03e │ │ │ │ + b.n 2dfc6 │ │ │ │ vsub.f64 d7, d8, d7 │ │ │ │ vldr d6, [r7, #16] │ │ │ │ vdiv.f64 d12, d7, d6 │ │ │ │ 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2f382 │ │ │ │ + bge.n 2f35a │ │ │ │ + b.n 2f30a │ │ │ │ nop │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #185 @ 0xb9 │ │ │ │ cmp r5, #24 │ │ │ │ strb r4, [r0, r1] │ │ │ │ movs r1, #251 @ 0xfb │ │ │ │ ands r1, r1 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ strh r0, [r0, #0] │ │ │ │ eors r6, r4 │ │ │ │ - ldrh r2, [r2, #38] @ 0x26 │ │ │ │ + ldrh r2, [r1, #42] @ 0x2a │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - b.n 2f8ec │ │ │ │ + b.n 2f834 │ │ │ │ movs r2, r0 │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ - ldr r2, [pc, #132] @ (2f490 ) │ │ │ │ + ldr r2, [pc, #132] @ (2f418 ) │ │ │ │ add r2, pc │ │ │ │ ldr.w r3, [r0, #456] @ 0x1c8 │ │ │ │ - cbz r3, 2f47a │ │ │ │ + cbz r3, 2f402 │ │ │ │ ldr r0, [r3, #4] │ │ │ │ - cbz r0, 2f47a │ │ │ │ + cbz r0, 2f402 │ │ │ │ push {r4} │ │ │ │ movs r0, #120 @ 0x78 │ │ │ │ ldr r4, [r3, #8] │ │ │ │ mla r0, r0, r4, r3 │ │ │ │ ldr r0, [r0, #56] @ 0x38 │ │ │ │ - cbz r0, 2f474 │ │ │ │ - ldr.w ip, [pc, #108] @ 2f494 │ │ │ │ - ldr r0, [pc, #108] @ (2f498 ) │ │ │ │ - vldr d7, [pc, #84] @ 2f480 │ │ │ │ + cbz r0, 2f3fc │ │ │ │ + ldr.w ip, [pc, #108] @ 2f41c │ │ │ │ + ldr r0, [pc, #108] @ (2f420 ) │ │ │ │ + vldr d7, [pc, #84] @ 2f408 │ │ │ │ add r0, pc │ │ │ │ ldr.w r2, [r2, ip] │ │ │ │ vldr d5, [r0, #48] @ 0x30 │ │ │ │ vldr d6, [r2] │ │ │ │ movs r2, #120 @ 0x78 │ │ │ │ vcmpe.f64 d5, d6 │ │ │ │ mla r3, r2, r4, r3 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ ldr r2, [r3, #60] @ 0x3c │ │ │ │ vstr d7, [r0, #48] @ 0x30 │ │ │ │ - vldr d7, [pc, #48] @ 2f488 │ │ │ │ + vldr d7, [pc, #48] @ 2f410 │ │ │ │ it gt │ │ │ │ addgt.w r1, r1, r1, lsl #2 │ │ │ │ vstr d7, [r3, #104] @ 0x68 │ │ │ │ add r2, r1 │ │ │ │ cmp.w r2, #2000 @ 0x7d0 │ │ │ │ it ge │ │ │ │ movge.w r2, #2000 @ 0x7d0 │ │ │ │ @@ -46078,100 +46069,100 @@ │ │ │ │ bx lr │ │ │ │ nop.w │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #185 @ 0xb9 │ │ │ │ ... │ │ │ │ - ldrh r2, [r6, #30] │ │ │ │ + ldrh r2, [r5, #34] @ 0x22 │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - b.n 2f7c8 │ │ │ │ + b.n 2f710 │ │ │ │ movs r2, r0 │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r3, [r0, #456] @ 0x1c8 │ │ │ │ - cbz r3, 2f4b6 │ │ │ │ + cbz r3, 2f43e │ │ │ │ ldr r0, [r3, #4] │ │ │ │ - cbz r0, 2f4b8 │ │ │ │ + cbz r0, 2f440 │ │ │ │ ldr r2, [r3, #8] │ │ │ │ movs r1, #120 @ 0x78 │ │ │ │ mla r3, r1, r2, r3 │ │ │ │ ldr r0, [r3, #52] @ 0x34 │ │ │ │ bx lr │ │ │ │ mov r0, r3 │ │ │ │ bx lr │ │ │ │ nop │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r3, [r0, #456] @ 0x1c8 │ │ │ │ - cbz r3, 2f510 │ │ │ │ + cbz r3, 2f498 │ │ │ │ ldr r0, [r3, #4] │ │ │ │ - cbz r0, 2f50e │ │ │ │ + cbz r0, 2f496 │ │ │ │ push {r4} │ │ │ │ movs r2, #120 @ 0x78 │ │ │ │ ldr r4, [r3, #8] │ │ │ │ mla r2, r2, r4, r3 │ │ │ │ ldr r0, [r2, #20] │ │ │ │ - cbz r0, 2f508 │ │ │ │ + cbz r0, 2f490 │ │ │ │ ldrh r0, [r0, #12] │ │ │ │ ands.w r0, r0, #2 │ │ │ │ - beq.n 2f508 │ │ │ │ + beq.n 2f490 │ │ │ │ ldr r0, [r2, #56] @ 0x38 │ │ │ │ - cbz r0, 2f4f6 │ │ │ │ + cbz r0, 2f47e │ │ │ │ vldr d7, [r2, #112] @ 0x70 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it mi │ │ │ │ movmi r0, #0 │ │ │ │ - bmi.n 2f508 │ │ │ │ + bmi.n 2f490 │ │ │ │ movs r2, #120 @ 0x78 │ │ │ │ movs r0, #1 │ │ │ │ mla r2, r4, r2, r2 │ │ │ │ add r3, r2 │ │ │ │ ldrd r2, r3, [r3] │ │ │ │ strd r2, r3, [r1] │ │ │ │ ldr.w r4, [sp], #4 │ │ │ │ bx lr │ │ │ │ bx lr │ │ │ │ mov r0, r3 │ │ │ │ bx lr │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r3, [r0, #456] @ 0x1c8 │ │ │ │ - cbz r3, 2f548 │ │ │ │ + cbz r3, 2f4d0 │ │ │ │ ldr r0, [r3, #4] │ │ │ │ - cbz r0, 2f54a │ │ │ │ + cbz r0, 2f4d2 │ │ │ │ ldr r2, [r3, #8] │ │ │ │ movs r0, #120 @ 0x78 │ │ │ │ mla r3, r0, r2, r3 │ │ │ │ ldr r0, [r3, #20] │ │ │ │ - cbz r0, 2f54a │ │ │ │ + cbz r0, 2f4d2 │ │ │ │ vldr d7, [r3, #112] @ 0x70 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.n 2f548 │ │ │ │ + bmi.n 2f4d0 │ │ │ │ ldrd r2, r3, [r3, #128] @ 0x80 │ │ │ │ movs r0, #1 │ │ │ │ strd r2, r3, [r1] │ │ │ │ bx lr │ │ │ │ movs r0, #0 │ │ │ │ bx lr │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r3, [r0, #456] @ 0x1c8 │ │ │ │ - cbz r3, 2f588 │ │ │ │ + cbz r3, 2f510 │ │ │ │ ldr r0, [r3, #4] │ │ │ │ - cbz r0, 2f586 │ │ │ │ + cbz r0, 2f50e │ │ │ │ push {r4} │ │ │ │ movs r2, #120 @ 0x78 │ │ │ │ ldr r4, [r3, #8] │ │ │ │ mla r0, r2, r4, r3 │ │ │ │ ldr r0, [r0, #20] │ │ │ │ - cbz r0, 2f580 │ │ │ │ + cbz r0, 2f508 │ │ │ │ ldrh r0, [r0, #12] │ │ │ │ ands.w r0, r0, #1 │ │ │ │ - beq.n 2f580 │ │ │ │ + beq.n 2f508 │ │ │ │ mla r2, r4, r2, r2 │ │ │ │ movs r0, #1 │ │ │ │ add r3, r2 │ │ │ │ ldrd r2, r3, [r3] │ │ │ │ strd r2, r3, [r1] │ │ │ │ ldr.w r4, [sp], #4 │ │ │ │ bx lr │ │ │ │ @@ -46180,120 +46171,120 @@ │ │ │ │ bx lr │ │ │ │ push {r4, r5, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ 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(2f874 ) │ │ │ │ vmov.f64 d1, d8 │ │ │ │ - ldr r1, [pc, #328] @ (2f8f0 ) │ │ │ │ + ldr r1, [pc, #328] @ (2f878 ) │ │ │ │ vmov.f64 d2, d11 │ │ │ │ add r3, pc │ │ │ │ vmov.f64 d0, d9 │ │ │ │ add r1, pc │ │ │ │ mov r2, r6 │ │ │ │ mov r0, r4 │ │ │ │ - bl 2ebcc │ │ │ │ + bl 2eb54 │ │ │ │ movs r3, #120 @ 0x78 │ │ │ │ vadd.f64 d8, d10, d8 │ │ │ │ mla r3, r3, r7, r5 │ │ │ │ vldr d7, [r3, #112] @ 0x70 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - blt.n 2f85e │ │ │ │ - ldr r1, [pc, #284] @ (2f8f4 ) │ │ │ │ + blt.n 2f7e6 │ │ │ │ + ldr r1, [pc, #284] @ (2f87c ) │ │ │ │ mov r0, r6 │ │ │ │ ldrd r2, r3, [r3, #128] @ 0x80 │ │ │ │ add r1, pc │ │ │ │ - blx 35fc │ │ │ │ - ldr r3, [pc, #276] @ (2f8f8 ) │ │ │ │ + blx 3598 │ │ │ │ + ldr r3, [pc, #276] @ (2f880 ) │ │ │ │ vmov.f64 d1, d8 │ │ │ │ - ldr r1, [pc, #272] @ (2f8fc ) │ │ │ │ + ldr r1, [pc, #272] @ (2f884 ) │ │ │ │ vmov.f64 d2, d11 │ │ │ │ add r3, pc │ │ │ │ vmov.f64 d0, d9 │ │ │ │ add r1, pc │ │ │ │ mov r2, r6 │ │ │ │ mov r0, r4 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2f668 │ │ │ │ - ldr r1, [pc, #188] @ (2f910 ) │ │ │ │ + bl 2eb54 │ │ │ │ + b.n 2f5f0 │ │ │ │ + ldr r1, [pc, #188] @ (2f898 ) │ │ │ │ adds r2, #1 │ │ │ │ mov r0, r6 │ │ │ │ add r1, pc │ │ │ │ - blx 35fc │ │ │ │ - b.n 2f710 │ │ │ │ - ldr r3, [pc, #180] @ (2f914 ) │ │ │ │ + blx 3598 │ │ │ │ + b.n 2f698 │ │ │ │ + ldr r3, [pc, #180] @ (2f89c ) │ │ │ │ add r3, pc │ │ │ │ ldmia.w r3, {r0, r1} │ │ │ │ str r0, [sp, #4] │ │ │ │ strh.w r1, [sp, #8] │ │ │ │ - b.n 2f7e2 │ │ │ │ - ldr r1, [pc, #168] @ (2f918 ) │ │ │ │ + b.n 2f76a │ │ │ │ + ldr r1, [pc, #168] @ (2f8a0 ) │ │ │ │ mov r0, r6 │ │ │ │ ldr r2, [r5, #64] @ 0x40 │ │ │ │ add r1, pc │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ ldr r3, [r5, #60] @ 0x3c │ │ │ │ movw r1, #26215 @ 0x6667 │ │ │ │ movt r1, #26214 @ 0x6666 │ │ │ │ add r5, sp, #104 @ 0x68 │ │ │ │ asrs r2, r3, #31 │ │ │ │ smull r0, r1, r1, r3 │ │ │ │ mov r0, r5 │ │ │ │ rsb r2, r2, r1, asr #2 │ │ │ │ movs r1, #10 │ │ │ │ mls r3, r1, r2, r3 │ │ │ │ - ldr r1, [pc, #128] @ (2f91c ) │ │ │ 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│ movs r1, r0 │ │ │ │ - cbnz r4, 2f960 │ │ │ │ + pop {r3, r4, r5, r6, pc} │ │ │ │ movs r1, r0 │ │ │ │ - revsh r2, r7 │ │ │ │ + pop {r1, r2, r3, r5, pc} │ │ │ │ movs r1, r0 │ │ │ │ - cbnz r4, 2f95a │ │ │ │ + pop {r6, pc} │ │ │ │ movs r1, r0 │ │ │ │ - cbnz r4, 2f95c │ │ │ │ + pop {r3, r4, r5, pc} │ │ │ │ movs r1, r0 │ │ │ │ - revsh r2, r4 │ │ │ │ + pop {r1, r2, r4, pc} │ │ │ │ movs r1, r0 │ │ │ │ - add r7, sp, #992 @ 0x3e0 │ │ │ │ + sxth r4, r6 │ │ │ │ movs r1, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d15} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3232] @ 0xca0 │ │ │ │ - ldr.w r2, [pc, #1036] @ 2fd48 │ │ │ │ + ldr.w r2, [pc, #1036] @ 2fcd0 │ │ │ │ sub.w sp, sp, #764 @ 0x2fc │ │ │ │ - ldr.w r3, [pc, #1032] @ 2fd4c │ │ │ │ + ldr.w r3, [pc, #1032] @ 2fcd4 │ │ │ │ add r2, pc │ │ │ │ - ldr.w r8, [pc, #1032] @ 2fd50 │ │ │ │ + ldr.w r8, [pc, #1032] @ 2fcd8 │ │ │ │ add r8, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r3, [r3, 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(2fce0 ) │ │ │ │ mov r1, r6 │ │ │ │ - ldr r6, [pc, #956] @ (2fd5c ) │ │ │ │ + ldr r6, [pc, #956] @ (2fce4 ) │ │ │ │ mov r0, r7 │ │ │ │ add r6, pc │ │ │ │ ldr.w r3, [r8, r3] │ │ │ │ ldrh r2, [r3, #0] │ │ │ │ - bl 5b70 │ │ │ │ + bl 5b08 │ │ │ │ ldr r3, [r6, #4] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 2ffa8 │ │ │ │ + beq.w 2ff30 │ │ │ │ ldrsh.w r9, [r4, #172] @ 0xac │ │ │ │ vmov.f64 d14, #96 @ 0x3f000000 0.5 │ │ │ │ ldrsh.w r3, [r4, #176] @ 0xb0 │ │ │ │ - vldr d7, [pc, #772] @ 2fcc8 │ │ │ │ + vldr d7, [pc, #772] @ 2fc50 │ │ │ │ vmov.f64 d8, d14 │ │ │ │ sub.w r3, r3, r9 │ │ │ │ vmov s13, r3 │ │ │ │ - ldr r3, [pc, #908] @ (2fd60 ) │ │ │ │ + ldr r3, [pc, #908] @ (2fce8 ) │ │ │ │ vcvt.f64.s32 d10, s13 │ │ │ │ ldr r0, [r4, #12] │ │ │ │ - vldr d9, [pc, #756] @ 2fcd0 │ │ │ │ - vldr d11, [pc, #760] @ 2fcd8 │ │ │ │ + vldr d9, [pc, #756] @ 2fc58 │ │ │ │ + vldr d11, [pc, #760] @ 2fc60 │ │ │ │ ldr.w r2, [r8, r3] │ │ │ │ vmla.f64 d8, d10, d7 │ │ │ │ vmov.f64 d7, d14 │ │ │ │ vmla.f64 d7, d10, d14 │ │ │ │ - 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[pc, #784] @ (2fcf0 ) │ │ │ │ vmul.f64 d7, d10, d7 │ │ │ │ vldr d13, [r0, #472] @ 0x1d8 │ │ │ │ vmla.f64 d14, d10, d5 │ │ │ │ ldr r0, [r4, #36] @ 0x24 │ │ │ │ add r3, pc │ │ │ │ vcvt.s32.f64 s14, d7 │ │ │ │ vcvt.s32.f64 s15, d6 │ │ │ │ @@ -46631,193 +46622,193 @@ │ │ │ │ str r2, [sp, #8] │ │ │ │ mov.w sl, #3 │ │ │ │ ldr r2, [sp, #20] │ │ │ │ str r2, [sp, #4] │ │ │ │ movs r2, #2 │ │ │ │ str r2, [sp, #0] │ │ │ │ mov r2, r6 │ │ │ │ - bl 9eb8 │ │ │ │ - vldr d7, [pc, #612] @ 2fd00 │ │ │ │ + bl 9d80 │ │ │ │ + vldr d7, [pc, #612] @ 2fc88 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ mov r2, r6 │ │ │ │ ldr r1, [sp, #28] │ │ │ │ vmul.f64 d7, d10, d7 │ │ │ │ str r3, [sp, #4] │ │ │ │ ldrh r3, [r1, #0] │ │ │ │ str r3, [sp, #8] │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ str.w sl, [sp] │ │ │ │ - ldr r3, [pc, #692] @ (2fd6c ) │ │ │ │ + ldr r3, [pc, #692] @ (2fcf4 ) │ │ │ │ ldr r0, [r4, #36] @ 0x24 │ │ │ │ add r3, pc │ │ │ │ vmov r6, s15 │ │ │ │ add r6, r9 │ │ │ │ mov.w r9, #120 @ 0x78 │ │ │ │ mov r1, r6 │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ ldr r0, [sp, #24] │ │ │ │ - ldr r1, [pc, #672] @ (2fd70 ) │ │ │ │ + ldr r1, [pc, #672] @ (2fcf8 ) │ │ │ │ add r3, sp, #748 @ 0x2ec │ │ │ │ str r3, [sp, #32] │ │ │ │ add r1, pc │ │ │ │ mla r9, r9, r0, r5 │ │ │ │ mov r0, r3 │ │ │ │ ldr.w r2, [r9, #52] @ 0x34 │ │ │ │ - blx 35fc │ │ │ │ - vldr d7, [pc, #548] @ 2fd08 │ │ │ │ + blx 3598 │ │ │ │ + vldr d7, [pc, #548] @ 2fc90 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ ldr r1, [sp, #28] │ │ │ │ vmul.f64 d10, d10, d7 │ │ │ │ str r3, [sp, #4] │ │ │ │ ldr r3, [sp, #32] │ │ │ │ ldrh r2, [r1, #0] │ │ │ │ mov r1, r6 │ │ │ │ str r2, [sp, #8] │ │ │ │ add r6, sp, #616 @ 0x268 │ │ │ │ vcvt.s32.f64 s15, d10 │ │ │ │ str.w sl, [sp] │ │ │ │ ldr r0, [r4, #36] @ 0x24 │ │ │ │ vmov r2, s15 │ │ │ │ add r2, fp │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ mov r0, r6 │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ mov r1, sl │ │ │ │ vneg.f64 d0, d13 │ │ │ │ mov r0, r6 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ vmov.f64 d2, d9 │ │ │ │ vmov.f64 d1, d9 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov r0, r6 │ │ │ │ - bl b180 │ │ │ │ + bl b284 │ │ │ │ vcvt.f64.s32 d8, s16 │ │ │ │ vcvt.f64.s32 d10, s30 │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ mov r0, r6 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ - bl b23c │ │ │ │ - bl 46138 │ │ │ │ + bl b338 │ │ │ │ + bl 460c0 │ │ │ │ mov r3, r8 │ │ │ │ mov r2, r7 │ │ │ │ mov r1, r6 │ │ │ │ - bl 45dc4 │ │ │ │ + bl 45d4c │ │ │ │ mov r0, r6 │ │ │ │ - bl acb0 │ │ │ │ - vldr d7, [pc, #428] @ 2fd10 │ │ │ │ + bl ac98 │ │ │ │ + vldr d7, [pc, #428] @ 2fc98 │ │ │ │ mov r0, r6 │ │ │ │ vdiv.f64 d2, d9, d7 │ │ │ │ vmov.f64 d1, d2 │ │ │ │ vmov.f64 d0, d2 │ │ │ │ - bl b180 │ │ │ │ + bl b284 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ mov r0, r6 │ │ │ │ - bl b23c │ │ │ │ - bl 46374 │ │ │ │ + bl b338 │ │ │ │ + bl 462fc │ │ │ │ mov r3, r8 │ │ │ │ mov r2, r7 │ │ │ │ mov r1, r6 │ │ │ │ - bl 45dc4 │ │ │ │ + bl 45d4c │ │ │ │ mov r0, r6 │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ vmov.f64 d2, #80 @ 0x3e800000 0.250 │ │ │ │ - vldr d1, [pc, #372] @ 2fd18 │ │ │ │ + vldr d1, [pc, #372] @ 2fca0 │ │ │ │ mov r0, r6 │ │ │ │ vmul.f64 d2, d9, d2 │ │ │ │ vmul.f64 d1, d9, d1 │ │ │ │ vmov.f64 d0, d2 │ │ │ │ - bl b180 │ │ │ │ + bl b284 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ mov r0, r6 │ │ │ │ - bl b23c │ │ │ │ - bl 46494 │ │ │ │ + bl b338 │ │ │ │ + bl 4641c │ │ │ │ mov r3, r8 │ │ │ │ mov r2, r7 │ │ │ │ mov r1, r6 │ │ │ │ - bl 45dc4 │ │ │ │ + bl 45d4c │ │ │ │ mov r0, r6 │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ vldr s15, [r9, #52] @ 0x34 │ │ │ │ - vldr d5, [pc, #316] @ 2fd20 │ │ │ │ + vldr d5, [pc, #316] @ 2fca8 │ │ │ │ mov r1, sl │ │ │ │ - vldr d6, [pc, #320] @ 2fd28 │ │ │ │ + vldr d6, [pc, #320] @ 2fcb0 │ │ │ │ mov r0, r6 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ vmul.f64 d7, d7, d5 │ │ │ │ vdiv.f64 d0, d7, d6 │ │ │ │ vsub.f64 d0, d0, d13 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ vmov.f64 d2, d11 │ │ │ │ vmov.f64 d1, d11 │ │ │ │ vmov.f64 d0, d11 │ │ │ │ mov r0, r6 │ │ │ │ - bl b180 │ │ │ │ + bl b284 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ mov r0, r6 │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ - bl b23c │ │ │ │ - ldr r3, [pc, #332] @ (2fd74 ) │ │ │ │ + bl b338 │ │ │ │ + ldr r3, [pc, #332] @ (2fcfc ) │ │ │ │ mov r2, r7 │ │ │ │ mov r1, r6 │ │ │ │ add r3, pc │ │ │ │ ldr r0, [r3, #4] │ │ │ │ mov r3, r8 │ │ │ │ - bl 45dc4 │ │ │ │ + bl 45d4c │ │ │ │ ldr.w r3, [r9, #20] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 2fdf4 │ │ │ │ + beq.w 2fd7c │ │ │ │ ldrh r3, [r3, #12] │ │ │ │ lsls r0, r3, #30 │ │ │ │ - beq.w 2fdf4 │ │ │ │ + beq.w 2fd7c │ │ │ │ ldr.w r2, [r9, #56] @ 0x38 │ │ │ │ - cbz r2, 2fc5c │ │ │ │ + cbz r2, 2fbe4 │ │ │ │ vldr d7, [r9, #112] @ 0x70 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - blt.w 2fdf4 │ │ │ │ + blt.w 2fd7c │ │ │ │ ldr r1, [sp, #24] │ │ │ │ movs r2, #120 @ 0x78 │ │ │ │ mla r1, r1, r2, r2 │ │ │ │ add r1, r5 │ │ │ │ vldr d14, [r1] │ │ │ │ lsls r1, r3, #31 │ │ │ │ - bpl.w 3033c │ │ │ │ - vldr d7, [pc, #172] @ 2fd20 │ │ │ │ + bpl.w 302c4 │ │ │ │ + vldr d7, [pc, #172] @ 2fca8 │ │ │ │ vcmpe.f64 d14, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it le │ │ │ │ movle.w sl, #0 │ │ │ │ - bgt.w 3040e │ │ │ │ + bgt.w 30396 │ │ │ │ mov r0, r6 │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ ldr r2, [sp, #24] │ │ │ │ movs r3, #120 @ 0x78 │ │ │ │ mla r3, r3, r2, r5 │ │ │ │ ldr r3, [r3, #20] │ │ │ │ ldrh r3, [r3, #12] │ │ │ │ lsls r2, r3, #31 │ │ │ │ - bpl.n 2fca4 │ │ │ │ + bpl.n 2fc2c │ │ │ │ vmov.f64 d7, #17 @ 0x40880000 4.250 │ │ │ │ vmul.f64 d14, d14, d7 │ │ │ │ - vldr d7, [pc, #136] @ 2fd30 │ │ │ │ + vldr d7, [pc, #136] @ 2fcb8 │ │ │ │ vcmpe.f64 d14, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bgt.n 2fd78 │ │ │ │ - vldr d7, [pc, #132] @ 2fd38 │ │ │ │ + bgt.n 2fd00 │ │ │ │ + vldr d7, [pc, #132] @ 2fcc0 │ │ │ │ vcmpe.f64 d14, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.w 3041c │ │ │ │ - vldr d0, [pc, #124] @ 2fd40 │ │ │ │ - b.n 2fd7c │ │ │ │ + bpl.w 303a4 │ │ │ │ + vldr d0, [pc, #124] @ 2fcc8 │ │ │ │ + b.n 2fd04 │ │ │ │ subs r0, r7, #2 │ │ │ │ @ instruction: 0xeb85b851 │ │ │ │ subs r7, #222 @ 0xde │ │ │ │ ldrb r1, [r5, r0] │ │ │ │ stmia r2!, {r0, r1, r2, r3, r7} │ │ │ │ cmp r0, #245 @ 0xf5 │ │ │ │ subs r7, #220 @ 0xdc │ │ │ │ @@ -46832,25 +46823,25 @@ │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #169 @ 0xa9 │ │ │ │ subs r0, r7, #2 │ │ │ │ @ instruction: 0xeb85b851 │ │ │ │ subs r7, #174 @ 0xae │ │ │ │ - bvc.n 2fd10 │ │ │ │ + bvc.n 2fc98 │ │ │ │ strb r3, [r4, #2] │ │ │ │ lsrs r5, r7, #8 │ │ │ │ subs r7, #167 @ 0xa7 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ subs r7, #235 @ 0xeb │ │ │ │ strb r4, [r4, #2] │ │ │ │ lsrs r5, r7, #8 │ │ │ │ - add r3, pc, #860 @ (adr r3, 3006c ) │ │ │ │ + add r3, pc, #860 @ (adr r3, 2fff4 ) │ │ │ │ subs r7, #192 @ 0xc0 │ │ │ │ ldmia r4!, {r0, r2, r3, r6, r7} │ │ │ │ ldmia r4!, {r2, r3, r6, r7} │ │ │ │ ldmia r4!, {r2, r3, r6, r7} │ │ │ │ subs r7, #236 @ 0xec │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ @@ -46860,161 +46851,161 @@ │ │ │ │ strb r4, [r0, r1] │ │ │ │ movs r1, #251 @ 0xfb │ │ │ │ ands r1, r1 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ strh r0, [r0, #0] │ │ │ │ eors r6, r4 │ │ │ │ - bcs.w fffbe8a0 <__bss_end__@@Base+0xfff17c68> │ │ │ │ - b.n 303ec │ │ │ │ + bcs.w fffbe828 <__bss_end__@@Base+0xfff17c88> │ │ │ │ + b.n 30374 │ │ │ │ subs r7, #196 @ 0xc4 │ │ │ │ - bcs.w fffbe8a8 <__bss_end__@@Base+0xfff17c70> │ │ │ │ - b.n 303f4 │ │ │ │ + bcs.w fffbe830 <__bss_end__@@Base+0xfff17c90> │ │ │ │ + b.n 3037c │ │ │ │ itt gt │ │ │ │ ldmiagt r4!, {r0, r2, r3, r6, r7} │ │ │ │ ldmiagt r4!, {r2, r3, r6, r7} │ │ │ │ ldmia r4!, {r2, r3, r6, r7} │ │ │ │ ite al │ │ │ │ - strhal r0, [r7, #52] @ 0x34 │ │ │ │ + strhal r0, [r6, #56] @ 0x38 │ │ │ │ mov r2, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - strh r2, [r6, #52] @ 0x34 │ │ │ │ + strh r2, [r5, #56] @ 0x38 │ │ │ │ movs r2, r0 │ │ │ │ - strh r4, [r2, #52] @ 0x34 │ │ │ │ + strh r4, [r1, #56] @ 0x38 │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r2, #11 │ │ │ │ + lsls r0, r1, #11 │ │ │ │ movs r0, r0 │ │ │ │ - bgt.n 2fda4 │ │ │ │ + bgt.n 2fcec │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r6, #9 │ │ │ │ + lsls r0, r5, #9 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r4, #11 │ │ │ │ + lsls r0, r3, #11 │ │ │ │ movs r0, r0 │ │ │ │ - add r6, sp, #376 @ 0x178 │ │ │ │ + sub sp, #104 @ 0x68 │ │ │ │ movs r1, r0 │ │ │ │ - @ instruction: 0xb8d4 │ │ │ │ + cbnz r0, 2fd3a │ │ │ │ movs r1, r0 │ │ │ │ - @ instruction: 0xb8be │ │ │ │ + revsh r2, r6 │ │ │ │ movs r1, r0 │ │ │ │ - bls.n 2fcac │ │ │ │ + bls.n 2fdf4 │ │ │ │ movs r2, r0 │ │ │ │ - vldr d0, [pc, #444] @ 2ff38 │ │ │ │ - vldr d2, [pc, #448] @ 2ff40 │ │ │ │ + vldr d0, [pc, #444] @ 2fec0 │ │ │ │ + vldr d2, [pc, #448] @ 2fec8 │ │ │ │ mov r0, r6 │ │ │ │ mov.w r9, #120 @ 0x78 │ │ │ │ - vldr d14, [pc, #448] @ 2ff48 │ │ │ │ - vldr d15, [pc, #452] @ 2ff50 │ │ │ │ + vldr d14, [pc, #448] @ 2fed0 │ │ │ │ + vldr d15, [pc, #452] @ 2fed8 │ │ │ │ vmov.f64 d1, d2 │ │ │ │ - bl b23c │ │ │ │ + bl b338 │ │ │ │ ldr r3, [sp, #24] │ │ │ │ movs r1, #3 │ │ │ │ mov r0, r6 │ │ │ │ mla r9, r9, r3, r5 │ │ │ │ vldr s15, [r9, #52] @ 0x34 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ vmul.f64 d7, d7, d14 │ │ │ │ vdiv.f64 d0, d7, d15 │ │ │ │ vsub.f64 d0, d0, d13 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ vmov.f64 d2, d11 │ │ │ │ vmov.f64 d1, d11 │ │ │ │ vmov.f64 d0, d11 │ │ │ │ mov r0, r6 │ │ │ │ - bl b180 │ │ │ │ + bl b284 │ │ │ │ mov r0, r6 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ - bl b23c │ │ │ │ - ldr r3, [pc, #440] @ (2ff98 ) │ │ │ │ + bl b338 │ │ │ │ + ldr r3, [pc, #440] @ (2ff20 ) │ │ │ │ mov r2, r7 │ │ │ │ mov r1, r6 │ │ │ │ add r3, pc │ │ │ │ ldr r0, [r3, #8] │ │ │ │ ldr r3, [sp, #36] @ 0x24 │ │ │ │ - bl 45dc4 │ │ │ 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2f8ec │ │ │ │ add r1, sp, #592 @ 0x250 │ │ │ │ mov r0, r4 │ │ │ │ - bl 2f58c │ │ │ │ + bl 2f514 │ │ │ │ vldr d11, [sp, #592] @ 0x250 │ │ │ │ - vldr d7, [pc, #260] @ 2ff60 │ │ │ │ + vldr d7, [pc, #260] @ 2fee8 │ │ │ │ vcmpe.f64 d11, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.w 3039a │ │ │ │ - vldr d7, [pc, #252] @ 2ff68 │ │ │ │ + bmi.w 30322 │ │ │ │ + vldr d7, [pc, #252] @ 2fef0 │ │ │ │ vcmp.f64 d11, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it gt │ │ │ │ vmovgt.f64 d11, d7 │ │ │ │ mov r0, r6 │ │ │ │ - bl acb0 │ │ │ │ - vldr d2, [pc, #188] @ 2ff40 │ │ │ │ - vldr d1, [pc, #232] @ 2ff70 │ │ │ │ + bl ac98 │ │ │ │ + vldr d2, [pc, #188] @ 2fec8 │ │ │ │ + vldr d1, [pc, #232] @ 2fef8 │ │ │ │ mov r0, r6 │ │ │ │ vmov.f64 d0, d2 │ │ │ │ vmul.f64 d1, d11, d1 │ │ │ │ - bl b23c │ │ │ │ + bl b338 │ │ │ │ vmov.f64 d2, d12 │ │ │ │ vmov.f64 d1, d12 │ │ │ │ vmov.f64 d0, d12 │ │ │ │ mov r0, r6 │ │ │ │ - bl b180 │ │ │ │ - vldr d7, [pc, #204] @ 2ff78 │ │ │ │ + bl b284 │ │ │ │ + vldr d7, [pc, #204] @ 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[pc, #924] @ (30290 ) │ │ │ │ ldrsblt r0, [r3, r4] │ │ │ │ subs r7, #166 @ 0xa6 │ │ │ │ stmia r1!, {r3, r4, r5, r6, r7} │ │ │ │ subs r3, r4, r1 │ │ │ │ - add r5, pc, #880 @ (adr r5, 302e8 ) │ │ │ │ + add r5, pc, #880 @ (adr r5, 30270 ) │ │ │ │ ands r4, r7 │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #241 @ 0xf1 │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #169 @ 0xa9 │ │ │ │ subs r0, r7, #2 │ │ │ │ @ instruction: 0xeb85b851 │ │ │ │ subs r7, #174 @ 0xae │ │ │ │ - bvc.n 2ffa8 │ │ │ │ + bvc.n 2ff30 │ │ │ │ strb r3, [r4, #2] │ │ │ │ lsrs r5, r7, #8 │ │ │ │ subs r7, #167 @ 0xa7 │ │ │ │ - bvc.n 2ff60 │ │ │ │ + bvc.n 2fea8 │ │ │ │ movs r2, r0 │ │ │ │ - bvc.n 2fed0 │ │ │ │ + bvc.n 30018 │ │ │ │ movs r2, r0 │ │ │ │ - bvs.n 2ff98 │ │ │ │ + bvs.n 2fee0 │ │ │ │ movs r2, r0 │ │ │ │ - add r1, sp, #584 @ 0x248 │ │ │ │ + add r3, sp, #824 @ 0x338 │ │ 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459c4 │ │ │ │ + bl 4594c │ │ │ │ vstr d9, [sp, #528] @ 0x210 │ │ │ │ add r1, sp, #520 @ 0x208 │ │ │ │ - vldr d9, [pc, #708] @ 302d0 │ │ │ │ + vldr d9, [pc, #708] @ 30258 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ strd sl, fp, [sp, #536] @ 0x218 │ │ │ │ vstr d9, [sp, #520] @ 0x208 │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ add r1, sp, #496 @ 0x1f0 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ vstr d11, [r1, #8] │ │ │ │ vmov.f64 d11, #112 @ 0x3f800000 1.0 │ │ │ │ vstr d9, [r1] │ │ │ │ strd sl, fp, [sp, #512] @ 0x200 │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ add r1, sp, #472 @ 0x1d8 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ vstr d10, [r1, #8] │ │ │ │ strd sl, fp, [r1] │ │ │ │ strd sl, fp, [r1, #16] │ │ │ │ - bl 459c4 │ │ │ │ - vldr d10, [pc, #652] @ 302d8 │ │ │ │ + bl 4594c │ │ │ │ + vldr d10, [pc, #652] @ 30260 │ │ │ │ add r1, sp, #448 @ 0x1c0 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ vstr d8, [r1] │ │ │ │ vstr d10, [r1, #8] │ │ │ │ strd sl, fp, [r1, #16] │ │ │ │ - bl 45908 │ │ │ │ + bl 45890 │ │ │ │ add r1, sp, #424 @ 0x1a8 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ vstr d11, [r1, #8] │ │ │ │ vstr d8, [r1] │ │ │ │ strd sl, fp, [r1, #16] │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ add r1, sp, #400 @ 0x190 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ vstr d11, [r1, #8] │ │ │ │ vstr d9, [r1] │ │ │ │ strd sl, fp, [r1, #16] │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ add r1, sp, #376 @ 0x178 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ vstr d10, [r1, #8] │ │ │ │ vstr d9, [r1] │ │ │ │ strd sl, fp, [r1, #16] │ │ │ │ - bl 459c4 │ │ │ │ - vldr d12, [pc, #576] @ 302e0 │ │ │ │ + bl 4594c │ │ │ │ + vldr d12, [pc, #576] @ 30268 │ │ │ │ add r1, sp, #352 @ 0x160 │ │ │ │ - vldr d11, [pc, #580] @ 302e8 │ │ │ │ + vldr d11, [pc, #580] @ 30270 │ │ │ │ vstr d10, [r1, #8] │ │ │ │ - vldr d10, [pc, #580] @ 302f0 │ │ │ │ + vldr d10, [pc, #580] @ 30278 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ vstr d8, [r1] │ │ │ │ strd sl, fp, [r1, #16] │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ vmov s15, r9 │ │ │ │ - ldr r6, [pc, #628] @ (30338 ) │ │ │ │ - vldr d8, [pc, #564] @ 302f8 │ │ │ │ + ldr r6, [pc, #628] @ (302c0 ) │ │ │ │ + vldr d8, [pc, #564] @ 30280 │ │ │ │ vmov.f64 d2, d10 │ │ │ │ vcvt.f64.s32 d9, s15 │ │ │ │ add r6, pc │ │ │ │ add.w r9, r9, #1 │ │ │ │ vmov.f64 d1, d8 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ vmul.f64 d9, d9, d12 │ │ │ │ vmul.f64 d9, d9, d11 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ - bl 2ecdc │ │ │ │ + bl 2ec64 │ │ │ │ vmov.f64 d2, d10 │ │ │ │ vmov.f64 d1, d8 │ │ │ │ vneg.f64 d0, d9 │ │ │ │ ldr r0, [r6, #4] │ │ │ │ - bl 2ecdc │ │ │ │ + bl 2ec64 │ │ │ │ cmp.w r9, #6 │ │ │ │ - bne.n 300bc │ │ │ │ - bl 458d8 │ │ │ │ - vldr d9, [pc, #432] @ 302b8 │ │ │ │ + bne.n 30044 │ │ │ │ + bl 45860 │ │ │ │ + vldr d9, [pc, #432] @ 30240 │ │ │ │ add r1, sp, #328 @ 0x148 │ │ │ │ - vldr d10, [pc, #456] @ 302d8 │ │ │ │ + vldr d10, [pc, #456] @ 30260 │ │ │ │ addw fp, pc, #436 @ 0x1b4 │ │ │ │ ldrd sl, fp, [fp] │ │ │ │ vstr d8, [r1, #16] │ │ │ │ strd sl, fp, [r1, #8] │ │ │ │ vstr d9, [r1] │ │ │ │ str r0, [r6, #8] │ │ │ │ - bl 45908 │ │ │ │ + bl 45890 │ │ │ │ add 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r8, r9, pc} │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ - strb r4, [r3, #23] │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ + strb r4, [r2, #25] │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - strb r6, [r3, #20] │ │ │ │ + strb r6, [r2, #22] │ │ │ │ movs r2, r0 │ │ │ │ push {r3, r4, r5, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4080] @ 0xff0 │ │ │ │ add.w r5, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r4, [r5, #448] @ 0x1c0 │ │ │ │ - cbz r4, 30b26 │ │ │ │ + cbz r4, 30aae │ │ │ │ movs r3, #1 │ │ │ │ str r3, [r4, #4] │ │ │ │ pop {r3, r4, r5, pc} │ │ │ │ - ldr r3, [pc, #56] @ (30b60 ) │ │ │ │ + ldr r3, [pc, #56] @ (30ae8 ) │ │ │ │ add r3, pc │ │ │ │ ldr r4, [r3, #0] │ │ │ │ - cbz r4, 30b46 │ │ │ │ + cbz r4, 30ace │ │ │ │ ldr r1, [r4, #0] │ │ │ │ movs r2, #0 │ │ │ │ str r1, [r3, #0] │ │ │ │ str r2, [r4, #0] │ │ │ │ movs r3, #0 │ │ │ │ str r3, [r4, #0] │ │ │ │ str r3, [r4, #8] │ │ │ │ movs r3, #1 │ │ │ │ str.w r4, [r5, #448] @ 0x1c0 │ │ │ │ str r3, [r4, #4] │ │ │ │ pop {r3, r4, r5, pc} │ │ │ │ - ldr r0, [pc, #28] @ (30b64 ) │ │ │ │ + ldr r0, [pc, #28] @ (30aec ) │ │ │ │ mov r3, r4 │ │ │ │ movs r2, #24 │ │ │ │ movs r1, #85 @ 0x55 │ │ │ │ add r0, pc │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ mov r4, r0 │ │ │ │ - ldr r0, [pc, #16] @ (30b68 ) │ │ │ │ + ldr r0, [pc, #16] @ (30af0 ) │ │ │ │ add r0, pc │ │ │ │ - bl 14098 │ │ │ │ - b.n 30b36 │ │ │ │ - ldmia r2, {r2, r4, r6, r7} │ │ │ │ + bl 14170 │ │ │ │ + b.n 30abe │ │ │ │ + ldmia r2, {r2, r4, r5, r7} │ │ │ │ movs r2, r0 │ │ │ │ - add r1, sp, #312 @ 0x138 │ │ │ │ + add r3, sp, #520 @ 0x208 │ │ │ │ movs r1, r0 │ │ │ │ ldr??.w pc, [sp, #255]! │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r3, [r0, #448] @ 0x1c0 │ │ │ │ - cbz r3, 30b7a │ │ │ │ + cbz r3, 30b02 │ │ │ │ movs r2, #0 │ │ │ │ str r2, [r3, #4] │ │ │ │ bx lr │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ - ldr.w ip, [pc, #104] @ 30bec │ │ │ │ + ldr.w ip, [pc, #104] @ 30b74 │ │ │ │ add ip, pc │ │ │ │ ldr.w r2, [r0, #448] @ 0x1c0 │ │ │ │ - cbz r2, 30bb4 │ │ │ │ + cbz r2, 30b3c │ │ │ │ ldr r3, [r2, #4] │ │ │ │ - cbz r3, 30bb4 │ │ │ │ + cbz r3, 30b3c │ │ │ │ ldr r1, [r2, #8] │ │ │ │ movw r3, #21846 @ 0x5556 │ │ │ │ movt r3, #21845 @ 0x5555 │ │ │ │ adds r1, #1 │ │ │ │ smull r0, r3, r3, r1 │ │ │ │ sub.w r3, r3, r1, asr #31 │ │ │ │ add.w r3, r3, r3, lsl #1 │ │ │ │ subs r3, r1, r3 │ │ │ │ str r3, [r2, #8] │ │ │ │ cmp r3, #1 │ │ │ │ - beq.n 30bb6 │ │ │ │ + beq.n 30b3e │ │ │ │ cmp r3, #2 │ │ │ │ - beq.n 30bc6 │ │ │ │ + beq.n 30b4e │ │ │ │ bx lr │ │ │ │ - ldr r3, [pc, #56] @ (30bf0 ) │ │ │ │ + ldr r3, [pc, #56] @ (30b78 ) │ │ │ │ ldr.w r3, [ip, r3] │ │ │ │ ldrd r0, r1, [r3] │ │ │ │ strd r0, r1, [r2, #16] │ │ │ │ bx lr │ │ │ │ - ldr r3, [pc, #40] @ (30bf0 ) │ │ │ │ + ldr r3, [pc, #40] @ (30b78 ) │ │ │ │ vmov.f64 d6, #96 @ 0x3f000000 0.5 │ │ │ │ vldr d5, [r2, #16] │ │ │ │ ldr.w r3, [ip, r3] │ │ │ │ vldr d7, [r3] │ │ │ │ vsub.f64 d7, d7, d5 │ │ │ │ vadd.f64 d7, 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[sp, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 318b0 │ │ │ │ + beq.w 31838 │ │ │ │ ldr r3, [r3, #4] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 318b0 │ │ │ │ + beq.w 31838 │ │ │ │ ldr.w sl, [r0, #12] │ │ │ │ ldr.w r3, [sl, #776] @ 0x308 │ │ │ │ ands.w r1, r3, #1024 @ 0x400 │ │ │ │ - bne.w 318b0 │ │ │ │ - ldr.w r2, [pc, #1028] @ 3105c │ │ │ │ - ldr.w r5, [pc, #1028] @ 31060 │ │ │ │ + bne.w 31838 │ │ │ │ + ldr.w r2, [pc, #1028] @ 30fe4 │ │ │ │ + ldr.w r5, [pc, #1028] @ 30fe8 │ │ │ │ vldr d10, [r0, #416] @ 0x1a0 │ │ │ │ add r5, pc │ │ │ │ vldr d9, [r0, #424] @ 0x1a8 │ │ │ │ ldr r2, [r4, r2] │ │ │ │ str r2, [sp, #36] @ 0x24 │ │ │ │ mov r0, r2 │ │ │ │ ldr r2, [r5, #28] │ │ │ │ ldrh r7, [r0, #0] │ │ │ │ cmp r2, #0 │ │ │ │ - beq.w 318d2 │ │ │ │ - ldr r3, [pc, #1004] @ (31064 ) │ │ │ │ + beq.w 3185a │ │ │ │ + ldr r3, [pc, #1004] @ (30fec ) │ │ │ │ ldr r2, [sp, #24] │ │ │ │ vldr d6, [r5, #32] │ │ │ │ ldr r3, [r2, r3] │ │ │ │ str r3, [sp, #44] @ 0x2c │ │ │ │ vldr d7, [r3] │ │ │ │ vcmpe.f64 d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bhi.n 30ca2 │ │ │ │ + bhi.n 30c2a │ │ │ │ str r1, [r5, #28] │ │ │ │ vmov.f64 d6, #96 @ 0x3f000000 0.5 │ │ │ │ - ldr r3, [pc, #976] @ (31068 ) │ │ │ │ + ldr r3, [pc, #976] @ (30ff0 ) │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ add r3, pc │ │ │ │ vstr d7, [r3, #32] │ │ │ │ ldr r3, [sp, #16] │ │ │ │ - vldr d7, [pc, #848] @ 30ff8 │ │ │ │ + vldr d7, [pc, #848] @ 30f80 │ │ │ │ vldr d6, [r3, #40] @ 0x28 │ │ │ │ vcmpe.f64 d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.w 318b0 │ │ │ │ + bmi.w 31838 │ │ │ │ add.w r3, sl, #200 @ 0xc8 │ │ │ │ str r3, [sp, #56] @ 0x38 │ │ │ │ mov r0, r3 │ │ │ │ - bl ab5c │ │ │ │ - vldr d7, [pc, #824] @ 31000 │ │ │ │ + bl aa78 │ │ │ │ + vldr d7, [pc, #824] @ 30f88 │ │ │ │ vcmpe.f64 d0, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.w 3195e │ │ │ │ - ldr r3, [pc, #916] @ (3106c ) │ │ │ │ + bpl.w 318e6 │ │ │ │ + ldr r3, [pc, #916] @ (30ff4 ) │ │ │ │ add r6, sp, #548 @ 0x224 │ │ │ │ add r3, pc │ │ │ │ ldmia.w r3, {r0, r1} │ │ │ │ str r0, [sp, #548] @ 0x224 │ │ │ │ strh.w r1, [sp, #552] @ 0x228 │ │ │ │ - vldr d5, [pc, #800] @ 31008 │ │ │ │ + vldr d5, [pc, #800] @ 30f90 │ │ │ │ vmov.f64 d4, #40 @ 0x41400000 12.0 │ │ │ │ - vldr d7, [pc, #784] @ 31000 │ │ │ │ + vldr d7, [pc, #784] @ 30f88 │ │ │ │ vmov.f64 d6, #96 @ 0x3f000000 0.5 │ │ │ │ ldr r4, [sp, #16] │ │ │ │ vmla.f64 d6, d9, d4 │ │ │ │ vmul.f64 d5, d10, d5 │ │ │ │ movs r2, #150 @ 0x96 │ │ │ │ vmul.f64 d7, d9, d7 │ │ │ │ mov r0, r6 │ │ │ │ @@ -48254,59 +48245,59 @@ │ │ │ │ mul.w r2, r1, r2 │ │ │ │ subs r5, r5, r3 │ │ │ │ addw r3, r2, #2047 @ 0x7ff │ │ │ │ ands.w r3, r3, r2, asr #32 │ │ │ │ it cc │ │ │ │ movcc r3, r2 │ │ │ │ mov.w r9, r3, asr #11 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ ldrsh.w r1, [r8, #16] │ │ │ │ mov r2, r5 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ add r1, r9 │ │ │ │ str r0, [sp, #0] │ │ │ │ str r3, [sp, #4] │ │ │ │ mov r0, r8 │ │ │ │ mov r3, r6 │ │ │ │ str r7, [sp, #8] │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ ldr r1, [sp, #32] │ │ │ │ movs r2, #220 @ 0xdc │ │ │ │ ldr r3, [r4, #36] @ 0x24 │ │ │ │ mov r0, r6 │ │ │ │ mul.w r2, r1, r2 │ │ │ │ ldrsh.w r8, [r3, #16] │ │ │ │ - ldr r1, [pc, #752] @ (31070 ) │ │ │ │ + ldr r1, [pc, #752] @ (30ff8 ) │ │ │ │ addw r3, r2, #2047 @ 0x7ff │ │ │ │ ands.w r3, r3, r2, asr #32 │ │ │ │ it cc │ │ │ │ movcc r3, r2 │ │ │ │ add r1, pc │ │ │ │ asrs r3, r3, #11 │ │ │ │ sub.w r8, r8, r3 │ │ │ │ negs r2, r3 │ │ │ │ str r2, [sp, #40] @ 0x28 │ │ │ │ ldrd r2, r3, [sl, #552] @ 0x228 │ │ │ │ eor.w r3, r3, #2147483648 @ 0x80000000 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ mov r0, r6 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ str r3, [sp, #4] │ │ │ │ mov r2, r5 │ │ │ │ str r0, [sp, #0] │ │ │ │ mov r1, r8 │ │ │ │ str r7, [sp, #8] │ │ │ │ mov r3, r6 │ │ │ │ ldr r0, [r4, #36] @ 0x24 │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ ldr r3, [r4, #36] @ 0x24 │ │ │ │ - vldr d3, [pc, #592] @ 31010 │ │ │ │ + vldr d3, [pc, #592] @ 30f98 │ │ │ │ vadd.f64 d5, d8, d8 │ │ │ │ - vldr d4, [pc, #592] @ 31018 │ │ │ │ + vldr d4, [pc, #592] @ 30fa0 │ │ │ │ mov r0, sl │ │ │ │ ldrsh.w r2, [r3, #16] │ │ │ │ vmov s14, r2 │ │ │ │ ldrsh.w r3, [r3, #18] │ │ │ │ vmov s12, r3 │ │ │ │ vcvt.s32.f64 s11, d5 │ │ │ │ vcvt.f64.s32 d7, s14 │ │ │ │ @@ -48314,53 +48305,53 @@ │ │ │ │ vcvt.f64.s32 d6, s12 │ │ │ │ vmls.f64 d6, d9, d4 │ │ │ │ vmov r8, s11 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r4, s15 │ │ │ │ vcvt.s32.f64 s15, d6 │ │ │ │ vmov r5, s15 │ │ │ │ - bl 23c1c │ │ │ │ + bl 23ba4 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 31cf2 │ │ │ │ + bne.w 31c7a │ │ │ │ mov r0, sl │ │ │ │ - bl 23260 │ │ │ │ + bl 231e8 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 31ac2 │ │ │ │ + bne.w 31a4a │ │ │ │ mov r0, sl │ │ │ │ add r5, r8 │ │ │ │ - bl 2372c │ │ │ │ + bl 236b4 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 31a90 │ │ │ │ + bne.w 31a18 │ │ │ │ mov r0, sl │ │ │ │ add r5, r8 │ │ │ │ - bl 236e8 │ │ │ │ + bl 23670 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 31a5e │ │ │ │ + bne.w 319e6 │ │ │ │ mov r0, sl │ │ │ │ add r5, r8 │ │ │ │ - bl 23444 │ │ │ │ + bl 233cc │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 31a2c │ │ │ │ + bne.w 319b4 │ │ │ │ mov r0, sl │ │ │ │ add r5, r8 │ │ │ │ - bl 23670 │ │ │ │ + bl 235f8 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 31d4e │ │ │ │ + bne.w 31cd6 │ │ │ │ mov r0, sl │ │ │ │ - bl 232f8 │ │ │ │ + bl 23280 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 31d1a │ │ │ │ + bne.w 31ca2 │ │ │ │ vadd.f64 d7, d9, d9 │ │ │ │ vldr d6, [sl, #216] @ 0xd8 │ │ │ │ vmov.f64 d5, #24 @ 0x40c00000 6.0 │ │ │ │ ldr r2, [sp, #32] │ │ │ │ ldr r4, [sp, #16] │ │ │ │ movs r3, #130 @ 0x82 │ │ │ │ vnmul.f64 d6, d6, d5 │ │ │ │ - ldr r1, [pc, #508] @ (31074 ) │ │ │ │ + ldr r1, [pc, #508] @ (30ffc ) │ │ │ │ vmul.f64 d7, d7, d8 │ │ │ │ mov r0, r6 │ │ │ │ mul.w r3, r2, r3 │ │ │ │ ldr r2, [r4, #36] @ 0x24 │ │ │ │ add r1, pc │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ ldrsh.w r8, [r2, #16] │ │ │ │ @@ -48370,89 +48361,89 @@ │ │ │ │ movcc r2, r3 │ │ │ │ ldr.w r3, [r4, #276] @ 0x114 │ │ │ │ add.w r8, r8, r2, asr #11 │ │ │ │ vmov r5, s15 │ │ │ │ vcvt.s32.f64 s15, d6 │ │ │ │ add r5, r3 │ │ │ │ vmov r2, s15 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ mov r0, r6 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ str r3, [sp, #4] │ │ │ │ mov r2, r5 │ │ │ │ str r0, [sp, #0] │ │ │ │ mov r1, r8 │ │ │ │ str r7, [sp, #8] │ │ │ │ mov r3, r6 │ │ │ │ add.w r8, r4, #344 @ 0x158 │ │ │ │ ldr r0, [r4, #36] @ 0x24 │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ add.w r3, sl, #4096 @ 0x1000 │ │ │ │ ldr r5, [r4, #36] @ 0x24 │ │ │ │ ldr.w r3, [r3, #172] @ 0xac │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 31d10 │ │ │ │ + bne.w 31c98 │ │ │ │ vldr d0, [sl, #472] @ 0x1d8 │ │ │ │ - vldr d4, [pc, #312] @ 31020 │ │ │ │ + vldr d4, [pc, #312] @ 30fa8 │ │ │ │ mov r1, r8 │ │ │ │ - vldr d5, [pc, #316] @ 31028 │ │ │ │ + vldr d5, [pc, #316] @ 30fb0 │ │ │ │ mov r0, r5 │ │ │ │ - vldr d6, [pc, #284] @ 31010 │ │ │ │ + vldr d6, [pc, #284] @ 30f98 │ │ │ │ vmul.f64 d7, d0, d4 │ │ │ │ vdiv.f64 d0, d7, d5 │ │ │ │ vmul.f64 d0, d0, d6 │ │ │ │ - bl 44658 │ │ │ │ + bl 445e0 │ │ │ │ ldr r3, [sp, #16] │ │ │ │ - vldr d7, [pc, #296] @ 31030 │ │ │ │ + vldr d7, [pc, #296] @ 30fb8 │ │ │ │ vldr d0, [sl, #280] @ 0x118 │ │ │ │ add.w r1, r3, #200 @ 0xc8 │ │ │ │ ldr r0, [r3, #36] @ 0x24 │ │ │ │ vdiv.f64 d0, d0, d7 │ │ │ │ - bl 44398 │ │ │ │ + bl 44320 │ │ │ │ vldr d0, [sl, #520] @ 0x208 │ │ │ │ - blx 3210 │ │ │ │ + blx 31c8 │ │ │ │ vmov.f64 d8, d0 │ │ │ │ vldr d0, [sl, #528] @ 0x210 │ │ │ │ - blx 3210 │ │ │ │ + blx 31c8 │ │ │ │ vldr d7, [sl, #224] @ 0xe0 │ │ │ │ vmul.f64 d8, d8, d7 │ │ │ │ vmul.f64 d8, d8, d0 │ │ │ │ vcmpe.f64 d8, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.w 31986 │ │ │ │ - vldr d6, [pc, #236] @ 31038 │ │ │ │ - vldr d7, [pc, #240] @ 31040 │ │ │ │ + bmi.w 3190e │ │ │ │ + vldr d6, [pc, #236] @ 30fc0 │ │ │ │ + vldr d7, [pc, #240] @ 30fc8 │ │ │ │ vdiv.f64 d0, d8, d6 │ │ │ │ vmul.f64 d0, d0, d7 │ │ │ │ - vldr d7, [pc, #172] @ 31008 │ │ │ │ + vldr d7, [pc, #172] @ 30f90 │ │ │ │ ldr r3, [sp, #16] │ │ │ │ vmul.f64 d7, d9, d7 │ │ │ │ add.w r1, r3, #272 @ 0x110 │ │ │ │ ldr r0, [r3, #36] @ 0x24 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r4, s15 │ │ │ │ - bl 44398 │ │ │ │ + bl 44320 │ │ │ │ mov r0, sl │ │ │ │ - bl 23444 │ │ │ │ + bl 233cc │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 31af4 │ │ │ │ + bne.w 31a7c │ │ │ │ vldr d7, [sl, #320] @ 0x140 │ │ │ │ - vldr d6, [pc, #192] @ 31048 │ │ │ │ + vldr d6, [pc, #192] @ 30fd0 │ │ │ │ ldr.w r0, [sl, #3928] @ 0xf58 │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ itt lt │ │ │ │ movlt r3, #0 │ │ │ │ strblt r3, [r0, #0] │ │ │ │ - blt.n 30fa8 │ │ │ │ - ldr r1, [pc, #216] @ (31078 ) │ │ │ │ + blt.n 30f30 │ │ │ │ + ldr r1, [pc, #216] @ (31000 ) │ │ │ │ vmov r2, r3, d7 │ │ │ │ add r1, pc │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ vmov.f64 d6, #50 @ 0x41900000 18.0 │ │ │ │ vmov.f64 d7, #96 @ 0x3f000000 0.5 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ movs r3, #200 @ 0xc8 │ │ │ │ vmla.f64 d7, d9, d6 │ │ │ │ add.w r8, sl, #3920 @ 0xf50 │ │ │ │ str.w sl, [sp, #48] @ 0x30 │ │ │ │ @@ -48471,15 +48462,15 @@ │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ subs r6, r6, r5 │ │ │ │ mov sl, r2 │ │ │ │ negs r5, r5 │ │ │ │ str r5, [sp, #40] @ 0x28 │ │ │ │ mov r5, fp │ │ │ │ vmov r9, s15 │ │ │ │ - b.n 31080 │ │ │ │ + b.n 31008 │ │ │ │ ldmia r4!, {r0, r2, r3, r6, r7} │ │ │ │ ldmia r4!, {r2, r3, r6, r7} │ │ │ │ ldmia r4!, {r2, r3, r6, r7} │ │ │ │ subs r7, #236 @ 0xec │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ @@ -48504,65 +48495,65 @@ │ │ │ │ strb r4, [r0, r1] │ │ │ │ movs r1, #251 @ 0xfb │ │ │ │ ands r1, r1 │ │ │ │ subs r0, r6, r1 │ │ │ │ ldr r2, [r0, #40] @ 0x28 │ │ │ │ strh r2, [r3, #14] │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ - bvc.n 31050 │ │ │ │ + bvc.n 30fd8 │ │ │ │ strb r3, [r4, #2] │ │ │ │ pop {r0, r2, r3, r4} │ │ │ │ lsls r7, r6 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, #0 │ │ │ │ lsls r4, r5 │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #201 @ 0xc9 │ │ │ │ - strb r4, [r4, #15] │ │ │ │ + strb r4, [r3, #17] │ │ │ │ movs r2, r0 │ │ │ │ - strb r2, [r3, #15] │ │ │ │ + strb r2, [r2, #17] │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r4, #11 │ │ │ │ + lsls r4, r3, #11 │ │ │ │ movs r0, r0 │ │ │ │ - ldmia r1!, {r2, r3, r4, r7} │ │ │ │ + ldmia r1!, {r2, r3, r4, r5, r6} │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - ldmia r1!, {r5, r6} │ │ │ │ + ldmia r1!, {r6} │ │ │ │ movs r2, r0 │ │ │ │ - add r7, pc, #848 @ (adr r7, 313c0 ) │ │ │ │ + add r2, sp, #32 │ │ │ │ movs r1, r0 │ │ │ │ - add r7, pc, #200 @ (adr r7, 3113c ) │ │ │ │ + add r1, sp, #408 @ 0x198 │ │ │ │ movs r1, r0 │ │ │ │ - add r6, pc, #424 @ (adr r6, 31220 ) │ │ │ │ + add r0, sp, #632 @ 0x278 │ │ │ │ movs r1, r0 │ │ │ │ - add r5, pc, #376 @ (adr r5, 311f4 ) │ │ │ │ + add r7, pc, #584 @ (adr r7, 3124c ) │ │ │ │ movs r1, r0 │ │ │ │ ldr r3, [sp, #16] │ │ │ │ ldr r5, [r3, #36] @ 0x24 │ │ │ │ ldr.w fp, [r8, #4]! │ │ │ │ mov r0, fp │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ ldr r2, [sp, #20] │ │ │ │ str r0, [sp, #0] │ │ │ │ mov r3, fp │ │ │ │ str r2, [sp, #4] │ │ │ │ mov r0, r5 │ │ │ │ mov r2, r6 │ │ │ │ mov r1, sl │ │ │ │ str r7, [sp, #8] │ │ │ │ add r6, r9 │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ cmp r4, r8 │ │ │ │ - bne.n 3107c │ │ │ │ + bne.n 31004 │ │ │ │ ldr r3, [sp, #32] │ │ │ │ movs r1, #160 @ 0xa0 │ │ │ │ ldr r5, [sp, #40] @ 0x28 │ │ │ │ ldr.w sl, [sp, #48] @ 0x30 │ │ │ │ str.w sl, [sp, #40] @ 0x28 │ │ │ │ mul.w r3, r1, r3 │ │ │ │ addw r6, sl, #3944 @ 0xf68 │ │ │ │ @@ -48577,43 +48568,43 @@ │ │ │ │ add r5, r3 │ │ │ │ addw r3, r1, #2047 @ 0x7ff │ │ │ │ ands.w r3, r3, r1, asr #32 │ │ │ │ it cc │ │ │ │ movcc r3, r1 │ │ │ │ add.w r3, r2, r3, asr #11 │ │ │ │ str r3, [sp, #32] │ │ │ │ - b.n 310ec │ │ │ │ + b.n 31074 │ │ │ │ ldr r3, [sp, #16] │ │ │ │ ldr r4, [r3, #36] @ 0x24 │ │ │ │ ldr.w r8, [r6, #4]! │ │ │ │ mov r0, r8 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ mov r2, r5 │ │ │ │ str r0, [sp, #0] │ │ │ │ mov r3, r8 │ │ │ │ ldr r1, [sp, #32] │ │ │ │ mov r0, r4 │ │ │ │ strd sl, r7, [sp, #4] │ │ │ │ add r5, r9 │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ cmp fp, r6 │ │ │ │ - bne.n 310e8 │ │ │ │ + bne.n 31070 │ │ │ │ ldr r4, [sp, #16] │ │ │ │ vmov.f64 d7, #96 @ 0x3f000000 0.5 │ │ │ │ - vldr d1, [pc, #592] @ 31368 │ │ │ │ + vldr d1, [pc, #592] @ 312f0 │ │ │ │ add r5, sp, #96 @ 0x60 │ │ │ │ vmov.f64 d5, d7 │ │ │ │ - vldr d2, [pc, #592] @ 31370 │ │ │ │ + vldr d2, [pc, #592] @ 312f8 │ │ │ │ ldr r2, [r4, #88] @ 0x58 │ │ │ │ mov r0, r5 │ │ │ │ vldr d4, [r4, #424] @ 0x1a8 │ │ │ │ vldr d6, [r4, #416] @ 0x1a0 │ │ │ │ - vldr d3, [pc, #584] @ 31378 │ │ │ │ + vldr d3, [pc, #584] @ 31300 │ │ │ │ vmla.f64 d5, d4, d1 │ │ │ │ - vldr d4, [pc, #584] @ 31380 │ │ │ │ + vldr d4, [pc, #584] @ 31308 │ │ │ │ vmul.f64 d6, d6, d2 │ │ │ │ ldr r3, [r4, #36] @ 0x24 │ │ │ │ str r2, [sp, #20] │ │ │ │ ldr.w sl, [sp, #40] @ 0x28 │ │ │ │ vmla.f64 d7, d6, d7 │ │ │ │ vmov s13, r2 │ │ │ │ ldrsh.w r2, [r3, #16] │ │ │ │ @@ -48627,173 +48618,173 @@ │ │ │ │ vmov r1, s15 │ │ │ │ adds r3, r1, r2 │ │ │ │ subs r1, r2, r1 │ │ │ │ vcvt.s32.f64 s4, d2 │ │ │ │ vcvt.s32.f64 s15, d6 │ │ │ │ vstr s4, [sp] │ │ │ │ vmov r2, s15 │ │ │ │ - bl 4abc │ │ │ │ + bl 4a54 │ │ │ │ ldr r0, [r4, #36] @ 0x24 │ │ │ │ mov r1, r5 │ │ │ │ - bl a770 │ │ │ │ + bl a638 │ │ │ │ ldr r0, [r4, #36] @ 0x24 │ │ │ │ adds r0, #8 │ │ │ │ - bl 4af0 │ │ │ │ + bl 4a88 │ │ │ │ mov r4, r0 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 31992 │ │ │ │ + bne.w 3191a │ │ │ │ vldr d10, [sl, #200] @ 0xc8 │ │ │ │ vmov.f64 d7, #20 @ 0x40a00000 5.0 │ │ │ │ ldr r3, [sp, #36] @ 0x24 │ │ │ │ vldr d9, [sl, #208] @ 0xd0 │ │ │ │ vabs.f64 d6, d10 │ │ │ │ ldrh r3, [r3, #0] │ │ │ │ str r3, [sp, #40] @ 0x28 │ │ │ │ vcmpe.f64 d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.n 311d2 │ │ │ │ + bpl.n 3115a │ │ │ │ vabs.f64 d6, d9 │ │ │ │ vcmpe.f64 d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.w 31daa │ │ │ │ + bmi.w 31d32 │ │ │ │ add r5, sp, #88 @ 0x58 │ │ │ │ add r3, sp, #80 @ 0x50 │ │ │ │ vldr d0, [sl, #472] @ 0x1d8 │ │ │ │ mov r0, r5 │ │ │ │ mov r1, r3 │ │ │ │ str r3, [sp, #32] │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ vldr d7, [r5, #-8] │ │ │ │ vldr d6, [r5] │ │ │ │ vmul.f64 d0, d7, d9 │ │ │ │ vmul.f64 d1, d6, d9 │ │ │ │ vmls.f64 d0, d6, d10 │ │ │ │ vmla.f64 d1, d10, d7 │ │ │ │ - blx 33f0 │ │ │ │ + blx 3398 │ │ │ │ vstr d0, [sp, #48] @ 0x30 │ │ │ │ - ldr r3, [pc, #456] @ (313d0 ) │ │ │ │ + ldr r3, [pc, #456] @ (31358 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #4] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 320bc │ │ │ │ + beq.w 32044 │ │ │ │ add r7, sp, #224 @ 0xe0 │ │ │ │ add r6, sp, #400 @ 0x190 │ │ │ │ mov r0, r6 │ │ │ │ add.w r9, sl, #72 @ 0x48 │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ vldr d0, [sp, #48] @ 0x30 │ │ │ │ movs r1, #3 │ │ │ │ mov r0, r6 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ vldr d0, [sl, #480] @ 0x1e0 │ │ │ │ movs r1, #2 │ │ │ │ mov r0, r6 │ │ │ │ vneg.f64 d0, d0 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ vldr d0, [sl, #488] @ 0x1e8 │ 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#0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bne.w 31dbc │ │ │ │ - ldr r3, [pc, #312] @ (313d8 ) │ │ │ │ + bne.w 31d44 │ │ │ │ + ldr r3, [pc, #312] @ (31360 ) │ │ │ │ add r3, pc │ │ │ │ ldr r2, [r3, #28] │ │ │ │ ldr r3, [sp, #16] │ │ │ │ ldr r3, [r3, #36] @ 0x24 │ │ │ │ ldrsh.w r4, [r3, #16] │ │ │ │ ldrsh.w r8, [r3, #18] │ │ │ │ cmp r2, #0 │ │ │ │ - beq.w 31e26 │ │ │ │ + beq.w 31dae │ │ │ │ mov r2, r4 │ │ │ │ ldr r4, [sp, #16] │ │ │ │ mov r3, r8 │ │ │ │ mov r0, sl │ │ │ │ mov r1, r4 │ │ │ │ - bl 46a40 │ │ │ │ + bl 469c8 │ │ │ │ ldrsh.w r3, [sl, #824] @ 0x338 │ │ │ │ cmp r3, #0 │ │ │ │ - bge.w 31ef0 │ │ │ │ + bge.w 31e78 │ │ │ │ ldr r3, [r4, #36] @ 0x24 │ │ │ │ ldrsh.w r2, [r3, #18] │ │ │ │ movs r4, #0 │ │ │ │ ldrsh.w r1, [r3, #16] │ │ │ │ mov.w r6, #23040 @ 0x5a00 │ │ │ │ ldr r0, [r3, #4] │ │ │ │ subs r2, #2 │ │ │ │ ldr r3, [sp, #40] @ 0x28 │ │ │ │ subs r1, #2 │ │ │ │ str r3, [sp, #12] │ │ │ │ movs r3, #4 │ │ │ │ stmia.w sp, {r3, r4, r6} │ │ │ │ - bl 6044 │ │ │ │ + bl 5fdc │ │ │ │ ldr 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{r1, r2, r4, r7} │ │ │ │ + stmia r3!, {r1, r2, r4, r5, r6} │ │ │ │ movs r2, r0 │ │ │ │ - stmia r3!, {r1, r2, r3, r4, r6} │ │ │ │ + stmia r3!, {r1, r2, r3, r4, r5} │ │ │ │ movs r2, r0 │ │ │ │ vmov s15, r7 │ │ │ │ mov r1, r4 │ │ │ │ mov r0, r5 │ │ │ │ vcvt.f64.s32 d0, s15 │ │ │ │ vmul.f64 d0, d0, d12 │ │ │ │ vdiv.f64 d0, d0, d13 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ vldr d7, [r5, #-8] │ │ │ │ vldr d6, [r5] │ │ │ │ vmov.f64 d3, d8 │ │ │ │ vmov.f64 d1, d8 │ │ │ │ vmov.f64 d2, d9 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ vmls.f64 d3, d11, d7 │ │ │ │ vmls.f64 d1, d10, d7 │ │ │ │ vmla.f64 d2, d11, d6 │ │ │ │ vmla.f64 d0, d10, d6 │ │ │ │ mov r0, r6 │ │ │ │ adds r7, #10 │ │ │ │ - bl 2a50c │ │ │ │ + bl 2a494 │ │ │ │ cmp r7, #40 @ 0x28 │ │ │ │ - bne.n 313dc │ │ │ │ + bne.n 31364 │ │ │ │ vldr d13, [sl, #488] @ 0x1e8 │ │ │ │ - vldr d7, [pc, #936] @ 317d8 │ │ │ │ + vldr d7, [pc, #936] @ 31760 │ │ │ │ vcmpe.f64 d13, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.w 31942 │ │ │ │ - ldr r3, [pc, #992] @ (31820 ) │ │ │ │ + bpl.w 318ca │ │ │ │ + ldr r3, [pc, #992] @ (317a8 ) │ │ │ │ vmov.f64 d13, d7 │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 31506 │ │ │ │ + bne.n 3148e │ │ │ │ ldr r4, [sp, #32] │ │ │ │ vmov.f64 d0, d13 │ │ │ │ mov r0, r5 │ │ │ │ - vldr d14, [pc, #908] @ 317e0 │ │ │ │ + vldr d14, [pc, #908] @ 31768 │ │ │ │ mov r1, r4 │ │ │ │ vmov.f64 d11, d9 │ │ │ │ - blx 3074 │ │ │ │ - vldr d5, [pc, #900] @ 317e8 │ │ │ │ + blx 3028 │ │ │ │ + vldr d5, [pc, #900] @ 31770 │ │ │ │ vmul.f64 d14, d10, d14 │ │ │ │ vldr d7, [r5, #-8] │ │ │ │ vldr d6, [r5] │ │ │ │ vmov.f64 d12, d8 │ │ │ │ vmul.f64 d5, d10, d5 │ │ │ │ - vldr d10, [pc, #884] @ 317f0 │ │ │ │ + vldr d10, [pc, #884] @ 31778 │ │ │ │ mov r1, r4 │ │ │ │ mov r0, r5 │ │ │ │ vadd.f64 d0, d13, d10 │ │ │ │ vmla.f64 d11, d6, d5 │ │ │ │ vmls.f64 d12, d7, d5 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ vldr d6, [r5, #-8] │ │ │ │ vldr d7, [r5] │ │ │ │ vsub.f64 d0, d13, d10 │ │ │ │ mov r1, r4 │ │ │ │ vmov.f64 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[r3, #12] │ │ │ │ - bne.n 31856 │ │ │ │ + bne.n 317de │ │ │ │ ldr r2, [sp, #44] @ 0x2c │ │ │ │ vldr d6, [r3, #16] │ │ │ │ vldr d7, [r2] │ │ │ │ vsub.f64 d7, d7, d6 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r3, s15 │ │ │ │ cmp.w r3, #3600 @ 0xe10 │ │ │ │ - bge.w 32020 │ │ │ │ + bge.w 31fa8 │ │ │ │ cmp r3, #59 @ 0x3b │ │ │ │ - bgt.w 31d80 │ │ │ │ - ldr r1, [pc, #840] @ (31bb0 ) │ │ │ │ + bgt.w 31d08 │ │ │ │ + ldr r1, [pc, #840] @ (31b38 ) │ │ │ │ mov r2, r3 │ │ │ │ add r3, sp, #528 @ 0x210 │ │ │ │ str r3, [sp, #20] │ │ │ │ add r1, pc │ │ │ │ mov r0, r3 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ ldr r5, [sp, #20] │ │ │ │ mov r0, r5 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ vmov.f64 d7, #62 @ 0x41f00000 30.0 │ │ │ │ vmov.f64 d6, #40 @ 0x41400000 12.0 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ vmul.f64 d7, d10, d7 │ │ │ │ str.w fp, [sp, #8] │ │ │ │ vmul.f64 d10, d10, d6 │ │ │ │ str r0, [sp, #0] │ │ │ │ @@ -49213,96 +49204,96 @@ │ │ │ │ mov r1, r4 │ │ │ │ ldr r0, [r2, #36] @ 0x24 │ │ │ │ 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#80 @ 0x50 │ │ │ │ add r5, sp, #88 @ 0x58 │ │ │ │ str r3, [sp, #32] │ │ │ │ - b.n 312f0 │ │ │ │ + b.n 31278 │ │ │ │ vmov.f64 d7, #56 @ 0x41c00000 24.0 │ │ │ │ ldr r3, [sp, #16] │ │ │ │ vmov.f64 d5, #16 @ 0x40800000 4.0 │ │ │ │ - ldr r1, [pc, #556] @ (31bd4 ) │ │ │ │ + ldr r1, [pc, #556] @ (31b5c ) │ │ │ │ vmul.f64 d7, d9, d7 │ │ │ │ movs r0, #5 │ │ │ │ ldr.w ip, [r3, #36] @ 0x24 │ │ │ │ add r1, pc │ │ │ │ add r3, sp, #548 @ 0x224 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ ldrsh.w r2, [ip, #18] │ │ │ │ @@ -49319,389 +49310,389 @@ │ │ │ │ ldmia r1, {r0, r1} │ │ │ │ str r0, [sp, #548] @ 0x224 │ │ │ │ strh.w r1, [sp, #552] @ 0x228 │ │ │ │ mov r0, ip │ │ │ │ sub.w r1, lr, r6, asr #1 │ │ │ │ vcvt.s32.f64 s15, d6 │ │ │ │ vmov r2, s15 │ │ │ │ - bl 9eb8 │ │ │ │ - ldr r3, [pc, #444] @ (31bbc ) │ │ │ │ + bl 9d80 │ │ │ │ + ldr r3, [pc, #444] @ (31b44 ) │ │ │ │ ldr r2, [sp, #24] │ │ │ │ vldr d6, [r5, #32] │ │ │ │ ldr r3, [r2, r3] │ │ │ │ str r3, [sp, #44] @ 0x2c │ │ │ │ vldr d7, [r3] │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - blt.w 30ca2 │ │ │ │ + blt.w 30c2a │ │ │ │ ldr r3, [r5, #28] │ │ │ │ cmp r3, #0 │ │ │ │ ite eq │ │ │ │ moveq r3, #1 │ │ │ │ movne r3, #0 │ │ │ │ str r3, [r5, #28] │ │ │ │ - beq.w 318f6 │ │ │ │ - b.w 30c92 │ │ │ │ + beq.w 3187e │ │ │ │ + b.w 30c1a │ │ │ │ mov r0, sl │ │ │ │ - bl 23c4c │ │ │ │ - cbz r0, 31a40 │ │ │ │ - ldr r3, [pc, #416] @ (31bd8 ) │ │ │ │ + bl 23bd4 │ │ │ │ + cbz r0, 319c8 │ │ │ │ + ldr r3, [pc, #416] @ (31b60 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 30e44 │ │ │ │ + bne.w 30dcc │ │ │ │ ldr r3, [sp, #20] │ │ │ │ mov r1, r4 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ str r3, [sp, #4] │ │ │ │ movs r3, #3 │ │ │ │ str r7, [sp, #8] │ │ │ │ str r3, [sp, #0] │ │ │ │ - ldr r3, [pc, #396] @ (31bdc ) │ │ │ │ + ldr r3, [pc, #396] @ (31b64 ) │ │ │ │ ldr r0, [r2, #36] @ 0x24 │ │ │ │ mov r2, r5 │ │ │ │ add r3, pc │ │ │ │ - bl 9eb8 │ │ │ │ - b.w 30e44 │ │ │ │ + bl 9d80 │ │ │ │ + b.w 30dcc │ │ │ │ mov r0, sl │ │ │ │ - bl 23c7c │ │ │ │ - cbz r0, 31a72 │ │ │ │ - ldr r3, [pc, #376] @ (31be0 ) │ │ │ │ + bl 23c04 │ │ │ │ + cbz r0, 319fa │ │ │ │ + ldr r3, [pc, #376] @ (31b68 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 30e36 │ │ │ │ + bne.w 30dbe │ │ │ │ ldr r3, [sp, #20] │ │ │ │ mov r1, r4 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ str r3, [sp, #4] │ │ │ │ movs r3, #3 │ │ │ │ str r7, [sp, #8] │ │ │ │ str r3, [sp, #0] │ │ │ │ - ldr r3, [pc, #352] @ (31be4 ) │ │ │ │ + ldr r3, [pc, #352] @ (31b6c ) │ │ │ │ ldr r0, [r2, #36] @ 0x24 │ │ │ │ mov r2, r5 │ │ │ │ add r3, pc │ │ │ │ - bl 9eb8 │ │ │ │ - b.w 30e36 │ │ │ │ + bl 9d80 │ │ │ │ + b.w 30dbe │ │ │ │ mov r0, sl │ │ │ │ - bl 23c64 │ │ │ │ - cbz r0, 31aa4 │ │ │ │ - ldr r3, [pc, #332] @ (31be8 ) │ │ │ │ + bl 23bec │ │ │ │ + cbz r0, 31a2c │ │ │ │ + ldr r3, [pc, #332] @ (31b70 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 30e28 │ │ │ │ + bne.w 30db0 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ mov r1, r4 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ str r3, [sp, #4] │ │ │ │ movs r3, #4 │ │ │ │ str r7, [sp, #8] │ │ │ │ str r3, [sp, #0] │ │ │ │ - ldr r3, [pc, #312] @ (31bec ) │ │ │ │ + ldr r3, [pc, #312] @ (31b74 ) │ │ │ │ ldr r0, [r2, #36] @ 0x24 │ │ │ │ mov r2, r5 │ │ │ │ add r3, pc │ │ │ │ - bl 9eb8 │ │ │ │ - b.w 30e28 │ │ │ │ + bl 9d80 │ │ │ │ + b.w 30db0 │ │ │ │ mov r0, sl │ │ │ │ - bl 23c34 │ │ │ │ - cbz r0, 31ad6 │ │ │ │ - ldr r3, [pc, #292] @ (31bf0 ) │ │ │ │ + bl 23bbc │ │ │ │ + cbz r0, 31a5e │ │ │ │ + ldr r3, [pc, #292] @ (31b78 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 30e1a │ │ │ │ + bne.w 30da2 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ mov r1, r4 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ str r3, [sp, #4] │ │ │ │ movs r3, #6 │ │ │ │ str r7, [sp, #8] │ │ │ │ str r3, [sp, #0] │ │ │ │ - ldr r3, [pc, #268] @ (31bf4 ) │ │ │ │ + ldr r3, [pc, #268] @ (31b7c ) │ │ │ │ ldr r0, [r2, #36] @ 0x24 │ │ │ │ mov r2, r5 │ │ │ │ add r3, pc │ │ │ │ - bl 9eb8 │ │ │ │ - b.w 30e1a │ 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@ (31b84 ) │ │ │ │ vdiv.f64 d5, d0, d4 │ │ │ │ add r1, pc │ │ │ │ vmla.f64 d7, d5, d6 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r2, s15 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ mov r0, r6 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ mov r2, r5 │ │ │ │ str r0, [sp, #0] │ │ │ │ mov r3, r6 │ │ │ │ ldr r5, [sp, #20] │ │ │ │ mov r1, r9 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ str r7, [sp, #8] │ │ │ │ str r5, [sp, #4] │ │ │ │ ldr r0, [r0, #36] @ 0x24 │ │ │ │ - bl 9eb8 │ │ │ │ - b.w 30f80 │ │ │ │ + bl 9d80 │ │ │ │ + b.w 30f08 │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #169 @ 0xa9 │ │ │ │ add pc, r0 │ │ │ │ - ldr r2, [pc, #924] @ (31f20 ) │ │ │ │ + ldr r2, [pc, #924] @ (31ea8 ) │ │ │ │ ldrsb r0, [r3, r4] │ │ │ │ subs r7, #230 @ 0xe6 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ strh r0, [r0, #0] │ │ │ │ eors r6, r4 │ │ │ │ cmp r5, #24 │ │ │ │ strb r4, [r0, r1] │ │ │ │ movs r1, #251 @ 0xfb │ │ │ │ ands r1, r1 │ │ │ │ ... │ │ │ │ - bvc.n 31bb8 │ │ │ │ + bvc.n 31b40 │ │ │ │ strb r3, [r4, #2] │ │ │ │ pop {r0, r2, r3, r4} │ │ │ │ lsls r7, r6 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, #0 │ │ │ │ lsls r4, r5 │ │ │ │ - str r4, [sp, #320] @ 0x140 │ │ │ │ + str r6, [sp, #560] @ 0x230 │ │ │ │ movs r1, r0 │ │ │ │ - str r0, [r1, #116] @ 0x74 │ │ │ │ + str r0, [r0, #124] @ 0x7c │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - pop {r2, r3, r4, r5, r6, r7} │ │ │ │ - movs r2, r0 │ │ │ │ pop {r2, r3, r4, r6, r7} │ │ │ │ movs r2, r0 │ │ │ │ - pop {r6, r7} │ │ │ │ + pop {r2, r3, r4, r5, r7} │ │ │ │ + movs r2, r0 │ │ │ │ + pop {r5, r7} │ │ │ │ movs r2, r0 │ │ │ │ - pop {r2, r5, r7} │ │ │ │ + pop {r2, r7} │ │ │ │ movs r2, r0 │ │ │ │ - ldr r3, [sp, #256] @ 0x100 │ │ │ │ + ldr r5, [sp, #464] @ 0x1d0 │ │ │ │ movs r1, r0 │ │ │ │ - ldr r2, [sp, #976] @ 0x3d0 │ │ │ │ + ldr r5, [sp, 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0x41400000 12.0 │ │ │ │ movs r3, #1 │ │ │ │ str.w fp, [sp, #8] │ │ │ │ vmul.f64 d2, d12, d2 │ │ │ │ str r3, [sp, #0] │ │ │ │ vmul.f64 d0, d7, d0 │ │ │ │ - ldr r3, [pc, #596] @ (31ec8 ) │ │ │ │ + ldr r3, [pc, #596] @ (31e50 ) │ │ │ │ add r3, pc │ │ │ │ vcvt.s32.f64 s4, d2 │ │ │ │ vdiv.f64 d7, d0, d3 │ │ │ │ vcvt.s32.f64 s13, d6 │ │ │ │ vstr s4, [sp, #4] │ │ │ │ ldr r0, [r1, #36] @ 0x24 │ │ │ │ vmov r2, s13 │ │ │ │ add r2, r8 │ │ │ │ vmls.f64 d7, d12, d4 │ │ │ │ vadd.f64 d7, d7, d5 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r1, s15 │ │ │ │ add r1, r9 │ │ │ │ - bl 9eb8 │ │ │ │ - b.n 3182c │ │ │ │ + bl 9d80 │ │ │ │ + b.n 317b4 │ │ │ │ mov r0, sl │ │ │ │ - bl 23cac │ │ │ │ - cbz r0, 31cb8 │ │ │ │ - ldr r3, [pc, #540] @ (31ecc ) │ │ │ │ + bl 23c34 │ │ │ │ + cbz r0, 31c40 │ │ │ │ + ldr r3, [pc, #540] @ (31e54 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 317b2 │ │ │ │ + bne.w 3173a │ │ │ │ vmov.f64 d6, #40 @ 0x41400000 12.0 │ │ │ │ vmov.f64 d7, #32 @ 0x41000000 8.0 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ movs r3, #2 │ │ │ │ vmul.f64 d6, d10, d6 │ │ │ │ vmul.f64 d7, d12, d7 │ │ │ │ str r3, [sp, #0] │ │ │ │ mov r1, r4 │ │ │ │ str.w fp, [sp, #8] │ │ │ │ - ldr r3, [pc, #504] @ (31ed0 ) │ │ │ │ + ldr r3, [pc, #504] @ (31e58 ) │ │ │ │ vcvt.s32.f64 s13, d6 │ │ │ │ vcvt.s32.f64 s14, d7 │ │ │ │ ldr r0, [r2, #36] @ 0x24 │ │ │ │ add r3, pc │ │ │ │ vmov r2, s13 │ │ │ │ vstr s14, [sp, #4] │ │ │ │ add r2, r8 │ │ │ │ - bl 9eb8 │ │ │ │ - b.n 317b2 │ │ │ │ + bl 9d80 │ │ │ │ + b.n 3173a │ │ │ │ ldr r3, [sp, #20] │ │ │ │ mov r1, r4 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ str r3, [sp, #4] │ │ │ │ movs r3, #4 │ │ │ │ str r7, [sp, #8] │ │ │ │ str r3, [sp, #0] │ │ │ │ - ldr r3, [pc, #464] @ (31ed4 ) │ │ │ │ + ldr r3, [pc, #464] @ (31e5c ) │ │ │ │ ldr r0, [r2, #36] @ 0x24 │ │ │ │ mov r2, r5 │ │ │ │ add r3, pc │ │ │ │ - bl 9eb8 │ │ │ │ - b.w 30e0e │ │ │ │ + bl 9d80 │ │ │ │ + b.w 30d96 │ │ │ │ mov r0, sl │ │ │ │ - bl 40008 │ │ │ │ - b.w 30ee4 │ │ │ │ + bl 3ff90 │ │ │ │ + b.w 30e6c │ │ │ │ mov r0, sl │ │ │ │ - bl 23cac │ │ │ │ - cbz r0, 31d2e │ │ │ │ - ldr r3, [pc, #436] @ (31ed8 ) │ │ │ │ + bl 23c34 │ │ │ │ + cbz r0, 31cb6 │ │ │ │ + ldr r3, [pc, #436] @ (31e60 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 30e5e │ │ │ │ + bne.w 30de6 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ add.w r2, r8, r5 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ mov r1, r4 │ │ │ │ str r3, [sp, #4] │ │ │ │ movs r3, #5 │ │ │ │ str r7, [sp, #8] │ │ │ │ str r3, [sp, #0] │ │ │ │ - ldr r3, [pc, #408] @ (31edc ) │ │ │ │ + ldr r3, [pc, #408] @ (31e64 ) │ │ │ │ ldr r0, [r0, #36] @ 0x24 │ │ │ │ add r3, pc │ │ │ │ - bl 9eb8 │ │ │ │ - b.w 30e5e │ │ │ │ + bl 9d80 │ │ │ │ + b.w 30de6 │ │ │ │ mov r0, sl │ │ │ │ - bl 23c94 │ │ │ │ - cbz r0, 31d62 │ │ │ │ - ldr r3, [pc, #392] @ (31ee0 ) │ │ │ │ + bl 23c1c │ │ │ │ + cbz r0, 31cea │ │ │ │ + ldr r3, [pc, #392] @ (31e68 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 30e52 │ │ │ │ + bne.w 30dda │ │ │ │ ldr r3, [sp, #20] │ │ │ │ mov r1, r4 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ str r3, [sp, #4] │ │ │ │ movs r3, #4 │ │ │ │ str r7, [sp, #8] │ │ │ │ str r3, [sp, #0] │ │ │ │ - ldr r3, [pc, #368] @ (31ee4 ) │ │ │ │ + ldr r3, [pc, #368] @ (31e6c ) │ │ │ │ ldr r0, [r2, #36] @ 0x24 │ │ │ │ mov r2, r5 │ │ │ │ add r3, pc │ │ │ │ - bl 9eb8 │ │ │ │ - b.w 30e52 │ │ │ │ + bl 9d80 │ │ │ │ + b.w 30dda │ │ │ │ movw r2, #34953 @ 0x8889 │ │ │ │ movt r2, #34952 @ 0x8888 │ │ │ │ smull r1, r2, r2, r3 │ │ │ │ asrs r1, r3, #31 │ │ │ │ add r2, r3 │ │ │ │ rsb r2, r1, r2, asr #5 │ │ │ │ movs r1, #60 @ 0x3c │ │ │ │ mls r3, r1, r2, r3 │ │ │ │ add r1, sp, #528 @ 0x210 │ │ │ │ mov r0, r1 │ │ │ │ str r1, [sp, #20] │ │ │ │ - ldr r1, [pc, #324] @ (31ee8 ) │ │ │ │ + ldr r1, [pc, #324] @ (31e70 ) │ │ │ │ add r1, pc │ │ │ │ - blx 35fc │ │ │ │ - b.n 31874 │ │ │ │ - vldr d7, [pc, #260] @ 31eb0 │ │ │ │ + blx 3598 │ │ │ │ + b.n 317fc │ │ │ │ + vldr d7, [pc, #260] @ 31e38 │ │ │ │ add r3, sp, #80 @ 0x50 │ │ │ │ add r5, sp, #88 @ 0x58 │ │ │ │ str r3, [sp, #32] │ │ │ │ vstr d7, [sp, #48] @ 0x30 │ │ │ │ - b.w 31204 │ │ │ │ + b.w 3118c │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it le │ │ │ │ movle.w r8, #0 │ │ │ │ - ble.w 312b4 │ │ │ │ + ble.w 3123c │ │ │ │ ldr r3, [sp, #16] │ │ │ │ vldr d5, [r7, #8] │ │ │ │ vldr d6, [r7, #16] │ │ │ │ ldr r3, [r3, #36] @ 0x24 │ │ │ │ ldrsh.w r0, [r3, #16] │ │ │ │ vldr d4, [r3, #56] @ 0x38 │ │ │ │ vldr d3, [r3, #64] @ 0x40 │ │ │ │ @@ -49725,105 +49716,105 @@ │ │ │ │ movcc r3, r2 │ │ │ │ add.w r8, r8, r3, asr #2 │ │ │ │ ldr r3, [sp, #16] │ │ │ │ vmov.f64 d8, #32 @ 0x41000000 8.0 │ │ │ │ mov r0, r6 │ │ │ │ vldr d7, [r3, #416] @ 0x1a0 │ │ │ │ vmul.f64 d8, d7, d8 │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ mov r0, r6 │ │ │ │ vmov.f64 d2, d8 │ │ │ │ vmov.f64 d1, d8 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ - bl b180 │ │ │ │ + bl b284 │ │ │ │ mov r0, r6 │ │ │ │ - vldr d0, [pc, #104] @ 31eb8 │ │ │ │ + vldr d0, [pc, #104] @ 31e40 │ │ │ │ movs r1, #3 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ movs r1, #1 │ │ │ │ mov r0, r6 │ │ │ │ - vldr d0, [pc, #88] @ 31eb8 │ │ │ │ - bl af7c │ │ │ │ + vldr d0, [pc, #88] @ 31e40 │ │ │ │ + bl afae │ │ │ │ vmov s15, r8 │ │ │ │ mov r0, r6 │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ vcvt.f64.s32 d1, s15 │ │ │ │ vmov s15, r4 │ │ │ │ vcvt.f64.s32 d0, s15 │ │ │ │ - bl b23c │ │ │ │ - ldr r3, [pc, #108] @ (31eec ) │ │ │ │ + bl b338 │ │ │ │ + ldr r3, [pc, #108] @ (31e74 ) │ │ │ │ mov r1, r6 │ │ │ │ add r3, pc │ │ │ │ ldr r0, [r3, #8] │ │ │ │ ldr r3, [sp, #16] │ │ │ │ ldr r2, [r3, #32] │ │ │ │ ldr r3, [sp, #40] @ 0x28 │ │ │ │ - bl 45dc4 │ │ │ │ - b.w 312b4 │ │ │ │ + bl 45d4c │ │ │ │ + b.w 3123c │ │ │ │ nop.w │ │ │ │ - add r6, pc, #916 @ (adr r6, 32230 ) │ │ │ │ + add r6, pc, #916 @ (adr r6, 321b8 ) │ │ │ │ ldrb r1, [r3, #14] │ │ │ │ - cbz r5, 31f0a │ │ │ │ + cbz r5, 31e92 │ │ │ │ itete ge │ │ │ │ @ instruction: 0xebd5f37b │ │ │ │ ldmialt r6, {r0, r3, r5, r6, r7} │ │ │ │ itet ge @ unpredictable │ │ │ │ @ instruction: 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instruction: 0xb884 │ │ │ │ movs r2, r0 │ │ │ │ - str r7, [sp, #408] @ 0x198 │ │ │ │ + ldr r1, [sp, #616] @ 0x268 │ │ │ │ movs r1, r0 │ │ │ │ - str r7, [sp, #504] @ 0x1f8 │ │ │ │ + ldr r1, [sp, #712] @ 0x2c8 │ │ │ │ movs r1, r0 │ │ │ │ - @ instruction: 0xb77a │ │ │ │ + @ instruction: 0xb75a │ │ │ │ movs r2, r0 │ │ │ │ ldr r4, [sp, #16] │ │ │ │ vmov.f64 d6, #52 @ 0x41a00000 20.0 │ │ │ │ - ldr.w r2, [pc, #1536] @ 324f8 │ │ │ │ + ldr.w r2, [pc, #1536] @ 32480 │ │ │ │ add.w r8, sp, #248 @ 0xf8 │ │ │ │ ldr r1, [sp, #24] │ │ │ │ vldr d7, [r4, #416] @ 0x1a0 │ │ │ │ ldr r0, [r1, r2] │ │ │ │ mov.w r1, #4416 @ 0x1140 │ │ │ │ movs r2, #240 @ 0xf0 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ smlabb r3, r3, r1, r2 │ │ │ │ mov r2, r8 │ │ │ │ add.w r1, sl, #344 @ 0x158 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ add r0, r3 │ │ │ │ vmov r6, s15 │ │ │ │ - bl b264 │ │ │ │ + bl b394 │ │ │ │ mov r2, r7 │ │ │ │ mov r1, r9 │ │ │ │ mov r0, r8 │ │ │ │ - bl b3c8 │ │ │ │ + bl b66a │ │ │ │ ldr r3, [r4, #36] @ 0x24 │ │ │ │ vldr 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[r5, r4] │ │ │ │ ldr r2, [r5, #84] @ 0x54 │ │ │ │ - blt.n 323a6 │ │ │ │ + blt.n 3232e │ │ │ │ subs r7, #177 @ 0xb1 │ │ │ │ vsra.u32 , q8, #10 │ │ │ │ stc 15, cr3, [fp], {239} @ 0xef │ │ │ │ cmp r5, #24 │ │ │ │ strb r4, [r0, r1] │ │ │ │ movs r1, #251 @ 0xfb │ │ │ │ ands r1, r1 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ strh r0, [r0, #0] │ │ │ │ eors r6, r4 │ │ │ │ - bgt.n 324f2 │ │ │ │ + bgt.n 3247a │ │ │ │ ldmia r1, {r0, r1, r2, r4, r5, r6, r7} │ │ │ │ udf #88 @ 0x58 │ │ │ │ subs r7, #161 @ 0xa1 │ │ │ │ lsls r7, r4, #21 │ │ │ │ ldrb r7, [r7, #2] │ │ │ │ @ instruction: 0xfb023fef │ │ │ │ cmp r5, #24 │ │ │ │ @@ -50273,780 +50264,780 @@ │ │ │ │ ldmia r2!, {r1, r5, r7} │ │ │ │ ldr r0, [sp, #388] @ 0x184 │ │ │ │ subs r7, #124 @ 0x7c │ │ │ │ subs r2, #24 │ │ │ │ adds r7, r2, r1 │ │ │ │ lsls r2, r7, #20 │ │ │ │ subs r7, #137 @ 0x89 │ │ │ │ - ldr r6, [pc, #68] @ (32510 ) │ │ │ │ + ldr r6, [pc, #68] @ (32498 ) │ │ │ │ stmia r4!, {r0, r3, r5, r6} │ │ │ │ strb r7, [r0, r5] │ │ │ │ subs r7, #166 @ 0xa6 │ │ │ │ subs r2, #24 │ │ │ │ adds r7, r2, r1 │ │ │ │ lsls r2, r7, #20 │ │ │ │ subs r7, #121 @ 0x79 │ │ │ │ - ldr r6, [pc, #68] @ (32520 ) │ │ │ │ + ldr r6, [pc, #68] @ (324a8 ) │ │ │ │ stmia r4!, {r0, r3, r5, r6} │ │ │ │ strb r7, [r0, r5] │ │ │ │ itet lt │ │ │ │ - ldrlt r4, [pc, #132] @ (32568 ) │ │ │ │ + ldrlt r4, [pc, #132] @ (324f0 ) │ │ │ │ stmiage r4!, {r0, r2, r4, r7} │ │ │ │ svclt 55 @ 0x37 │ │ │ │ subs r7, #129 @ 0x81 │ │ │ │ subs r3, #205 @ 0xcd │ │ │ │ str r7, [r7, #100] @ 0x64 │ │ │ │ - add r0, pc, #632 @ (adr r0, 32768 ) │ │ │ │ + add r0, pc, #632 @ (adr r0, 326f0 ) │ │ │ │ subs r7, #230 @ 0xe6 │ │ │ │ subs r3, #204 @ 0xcc │ │ │ │ str r7, [r7, #100] @ 0x64 │ │ │ │ - add r0, pc, #632 @ (adr r0, 32770 ) │ │ │ │ + add r0, pc, #632 @ (adr r0, 326f8 ) │ │ │ │ subs r7, #230 @ 0xe6 │ │ │ │ - lsls r0, r4, #10 │ │ │ │ + lsls r0, r3, #10 │ │ │ │ movs r0, r0 │ │ │ │ - str r4, [sp, #712] @ 0x2c8 │ │ │ │ + str r6, [sp, #920] @ 0x398 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r4, r0, #12 │ │ │ │ + lsls r4, r7, #11 │ │ │ │ movs r0, r0 │ │ │ │ - ldrh r0, [r2, #22] │ │ │ │ + ldrh r4, [r1, #40] @ 0x28 │ │ │ │ movs r1, r0 │ │ │ │ - cbz r2, 32546 │ │ │ │ + cbz r2, 324c6 │ │ │ │ movs r2, r0 │ │ │ │ vmov s15, r9 │ │ │ │ mov r1, r4 │ │ │ │ mov r0, r5 │ │ │ │ vcvt.f64.s32 d0, s15 │ │ │ │ vmul.f64 d0, d0, d11 │ │ │ │ vdiv.f64 d0, d0, d10 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ ldrd r2, r3, [r5] │ │ │ │ ldrd r0, r1, [r5, #-8] │ │ │ │ strd r0, r1, [r6, #16] │ │ │ │ strd r2, r3, [r6, #8] │ │ │ │ mov r1, r6 │ │ │ │ mov r0, r8 │ │ │ │ add.w r9, r9, #45 @ 0x2d │ │ │ │ vstr d9, [r6] │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ movw r3, #405 @ 0x195 │ │ │ │ cmp r9, r3 │ │ │ │ - bne.n 3250c │ │ │ │ + bne.n 32494 │ │ │ │ mov r3, r7 │ │ │ │ mov r7, r6 │ │ │ │ vmov.f64 d11, #240 @ 0xbf800000 -1.0 │ │ │ │ vmov.f64 d10, #128 @ 0xc0000000 -2.0 │ │ │ │ mov r1, r7 │ │ │ │ mov r0, r8 │ │ │ │ vstr d9, [r7] │ │ │ │ mov r6, r3 │ │ │ │ vstr d9, [r7, #8] │ │ │ │ vstr d11, [r7, #16] │ │ │ │ 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d2, d10, d11 │ │ │ │ vmul.f64 d0, d9, d10 │ │ │ │ add r0, sp, #56 @ 0x38 │ │ │ │ - bl ab18 │ │ │ │ + bl a9e0 │ │ │ │ mov r1, r4 │ │ │ │ ldr r0, [r7, #16] │ │ │ │ add r4, sp, #80 @ 0x50 │ │ │ │ - bl 45908 │ │ │ │ + bl 45890 │ │ │ │ vmov s15, r6 │ │ │ │ vcvt.f64.s32 d8, s15 │ │ │ │ vmov s15, r5 │ │ │ │ vldr d0, [sp, #32] │ │ │ │ vldr d1, [sp, #40] @ 0x28 │ │ │ │ mov r0, r4 │ │ │ │ vcvt.f64.s32 d3, s15 │ │ │ │ @@ -51965,147 +51956,147 @@ │ │ │ │ vdiv.f64 d7, d3, d8 │ │ │ │ vsub.f64 d4, d4, d2 │ │ │ │ vsub.f64 d5, d5, d1 │ │ │ │ vsub.f64 d6, d6, d0 │ │ │ │ vmla.f64 d2, d4, d7 │ │ │ │ vmls.f64 d1, d5, d7 │ │ │ │ vmla.f64 d0, d6, d7 │ │ │ │ - bl ab18 │ │ │ │ + bl a9e0 │ │ │ │ mov r0, r4 │ │ │ │ - bl ab5c │ │ │ │ + bl aa78 │ │ │ │ vldr d7, [sp, #80] @ 0x50 │ │ │ │ vldr d2, [sp, #96] @ 0x60 │ │ │ │ mov r0, r4 │ │ │ │ vldr d1, [sp, #88] @ 0x58 │ │ │ │ vdiv.f64 d2, d2, d0 │ │ │ │ vdiv.f64 d1, d1, d0 │ │ │ │ vdiv.f64 d0, d7, d0 │ │ │ │ - bl ab18 │ │ │ │ + bl a9e0 │ │ │ │ ldr r0, [r7, #16] │ │ │ │ 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afae │ │ │ │ vmov.f64 d2, d9 │ │ │ │ vmov.f64 d1, d9 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov r0, r8 │ │ │ │ - bl b180 │ │ │ │ + bl b284 │ │ │ │ vmov.f64 d1, d12 │ │ │ │ vmov.f64 d0, d11 │ │ │ │ vmov.f64 d2, d14 │ │ │ │ mov r0, r8 │ │ │ │ - bl b23c │ │ │ │ + bl b338 │ │ │ │ mov r1, r4 │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ - bl 4dd0 │ │ │ │ - vldr d7, [pc, #456] @ 33ab8 │ │ │ │ + bl 4d68 │ │ │ │ + vldr d7, [pc, #456] @ 33a40 │ │ │ │ ldmia.w r4, {r0, r1} │ │ │ │ add r4, sp, #64 @ 0x40 │ │ │ │ vmul.f64 d7, d10, d7 │ │ │ │ stmia.w r4, {r0, r1} │ │ │ │ mov r0, r4 │ │ │ │ vcvt.s32.f64 s14, d7 │ │ │ │ vmov r2, s14 │ │ │ │ mov r1, r2 │ │ │ │ - bl 4b14 │ │ │ │ + bl 4aac │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ mov r1, r4 │ │ │ │ - bl 4dd0 │ │ │ │ - ldr r3, [pc, #456] @ (33ae4 ) │ │ │ │ + bl 4d68 │ │ │ │ + ldr r3, [pc, #456] @ (33a6c ) │ │ │ │ add r3, pc │ │ │ │ ldr r2, [r3, #20] │ │ │ │ cmp r2, #0 │ │ │ │ - beq.w 33d00 │ │ │ │ + beq.w 33c88 │ │ │ │ subs r6, r2, #1 │ │ │ │ - bmi.w 340fe │ │ │ │ + bmi.w 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+ bl b394 │ │ │ │ vldr d6, [r4] │ │ │ │ vldr d7, [r4, #8] │ │ │ │ vadd.f64 d6, d6, d9 │ │ │ │ vadd.f64 d7, d7, d9 │ │ │ │ vcvt.s32.f64 s12, d6 │ │ │ │ vcvt.s32.f64 s14, d7 │ │ │ │ vmov r3, s12 │ │ │ │ strh r3, [r5, #4] │ │ │ │ vmov r3, s14 │ │ │ │ strh r3, [r5, #6] │ │ │ │ adds r3, r6, #2 │ │ │ │ - bne.n 3395a │ │ │ │ - ldr r3, [pc, #288] @ (33af0 ) │ │ │ │ + bne.n 338e2 │ │ │ │ + ldr r3, [pc, #288] @ (33a78 ) │ │ │ │ ldr.w sl, [sp, #32] │ │ │ │ add r3, pc │ │ │ │ ldr r2, [r3, #20] │ │ │ │ - ldr r6, [pc, #280] @ (33af4 ) │ │ │ │ + ldr r6, [pc, #280] @ (33a7c ) │ │ │ │ mov r1, fp │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ add r6, pc │ │ │ │ ldrh r3, [r6, #24] │ │ │ │ - bl 5a34 │ │ │ │ + bl 59cc │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ ldr r1, [sp, #16] │ │ │ │ ldrh r3, [r6, #26] │ │ │ │ ldr r2, [r6, #20] │ │ │ │ - bl 5a34 │ │ │ │ + bl 59cc │ │ │ │ ldr r0, [r6, #16] │ │ │ │ cmp r0, #0 │ │ │ │ - beq.w 33fba │ │ │ │ - ldr r6, [pc, #248] @ (33af8 ) │ │ │ │ + beq.w 33f42 │ │ │ │ + ldr r6, [pc, #248] @ (33a80 ) │ │ │ │ mov r1, r8 │ │ │ │ ldr r2, [sp, #20] │ │ │ │ add.w r9, sp, #72 @ 0x48 │ │ │ │ add r6, pc │ │ │ │ - vldr d9, [pc, #180] @ 33ac0 │ │ │ │ + vldr d9, [pc, #180] @ 33a48 │ │ │ │ ldrh r3, [r6, #28] │ │ │ │ - bl 45dc4 │ │ │ │ + bl 45d4c │ │ │ │ ldr r1, [sp, #8] │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ - bl 4dd0 │ │ │ │ + bl 4d68 │ │ │ │ mov r0, r9 │ │ │ │ - bl 6484 │ │ │ │ + bl 641c │ │ │ │ vmov.f64 d0, d8 │ │ │ │ mov r0, r9 │ │ │ │ - vldr d8, [pc, #156] @ 33ac8 │ │ │ │ - bl 64f4 │ │ │ │ - vldr d7, [pc, #156] @ 33ad0 │ │ │ │ + vldr d8, [pc, #156] @ 33a50 │ │ │ │ + bl 648c │ │ │ │ + vldr d7, [pc, #156] @ 33a58 │ │ │ │ mov r0, r9 │ │ │ │ vmul.f64 d7, d10, d7 │ │ │ │ vmov.f64 d0, d7 │ │ │ │ vstr d7, [sp, #8] │ │ │ │ - bl 64a8 │ │ │ │ + bl 6440 │ │ │ │ vmov.f64 d1, d12 │ │ │ │ vmov.f64 d0, d11 │ │ │ │ mov r0, r9 │ │ │ │ - bl 6574 │ │ │ │ + bl 650c │ │ │ │ ldr r1, [r6, #32] │ │ │ │ ldrh r7, [r6, #36] @ 0x24 │ │ │ │ mov r3, r9 │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ ldr r2, [r1, #0] │ │ │ │ ldr r1, [r1, #8] │ │ │ │ str r7, [sp, #0] │ │ │ │ - bl 65fc │ │ │ │ + bl 6594 │ │ │ │ ldr r1, [r6, #40] @ 0x28 │ │ │ │ ldrh r7, [r6, #44] @ 0x2c │ │ │ │ mov r3, r9 │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ ldr r2, [r1, #0] │ │ │ │ ldr r1, [r1, #8] │ │ │ │ str r7, [sp, #0] │ │ │ │ - bl 65fc │ │ │ │ + bl 6594 │ │ │ │ ldr r1, [r6, #48] @ 0x30 │ │ │ │ ldrh r6, [r6, #28] │ │ │ │ mov r3, r9 │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ ldr r2, [r1, #0] │ │ │ │ ldr r1, [r1, #8] │ │ │ │ str r6, [sp, #0] │ │ │ │ movs r6, #10 │ │ │ │ - bl 65fc │ │ │ │ + bl 6594 │ │ │ │ movw r3, #34953 @ 0x8889 │ │ │ │ movt r3, #34952 @ 0x8888 │ │ │ │ str r3, [sp, #16] │ │ │ │ - b.n 33c10 │ │ │ │ + b.n 33b98 │ │ │ │ subs r0, r7, #2 │ │ │ │ @ instruction: 0xeb85b851 │ │ │ │ subs r7, #222 @ 0xde │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ subs r7, #227 @ 0xe3 │ │ │ │ ... │ │ │ │ str r6, [r4, #100] @ 0x64 │ │ │ │ str r6, [r4, #100] @ 0x64 │ │ │ │ str r6, [r4, #100] @ 0x64 │ │ │ │ itet le │ │ │ │ movle r0, r0 │ │ │ │ movgt r0, r0 │ │ │ │ - ble.n 33ac8 │ │ │ │ + ble.n 33a50 │ │ │ │ lsls r5, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ - b.n 33ad0 │ │ │ │ + b.n 33a58 │ │ │ │ stmia r0!, {r0, r2, r7} │ │ │ │ add r1, sp, #1008 @ 0x3f0 │ │ │ │ - bcs.n 33ab8 │ │ │ │ + bcs.n 33a40 │ │ │ │ str r5, [r1, #36] @ 0x24 │ │ │ │ subs r7, #80 @ 0x50 │ │ │ │ - @ instruction: 0x47ae │ │ │ │ + ldr r0, [pc, #152] @ (33afc ) │ │ │ │ movs r2, r0 │ │ │ │ - blxns r3 │ │ │ │ + ldr r0, [pc, #80] @ (33ab8 ) │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - add r0, pc, #992 @ (adr r0, 33ec8 ) │ │ │ │ + add r0, pc, #864 @ (adr r0, 33dd0 ) │ │ │ │ movs r2, r0 │ │ │ │ - push {} │ │ │ │ + cbz r0, 33aec │ │ │ │ movs r2, r0 │ │ │ │ - add r1, pc, #216 @ (adr r1, 33bc8 ) │ │ │ │ + add r1, pc, #88 @ (adr r1, 33ad0 ) │ │ │ │ movs r2, r0 │ │ │ │ - add r0, pc, #256 @ (adr r0, 33bf4 ) │ │ │ │ + add r0, pc, #128 @ (adr r0, 33afc ) │ │ │ │ movs r2, r0 │ │ │ │ - add r0, pc, #208 @ (adr r0, 33bc8 ) │ │ │ │ + add r0, pc, #80 @ (adr r0, 33ad0 ) │ │ │ │ movs r2, r0 │ │ │ │ - add r0, pc, #48 @ (adr r0, 33b2c ) │ │ │ │ + ldr r7, [sp, #944] @ 0x3b0 │ │ │ │ movs r2, r0 │ │ │ │ cmp r5, #0 │ │ │ │ - bne.w 33c0a │ │ │ │ + bne.w 33b92 │ │ │ │ vmov s15, r6 │ │ │ │ - vldr d6, [pc, #784] @ 33e18 │ │ │ │ - vldr d0, [pc, #788] @ 33e20 │ │ │ │ + vldr d6, [pc, #784] @ 33da0 │ │ │ │ + vldr d0, [pc, #788] @ 33da8 │ │ │ │ add r5, sp, #48 @ 0x30 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ add r1, sp, #40 @ 0x28 │ │ │ │ mov r0, r5 │ │ │ │ - vldr d15, [pc, #780] @ 33e28 │ │ │ │ + vldr d15, [pc, #780] @ 33db0 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ vdiv.f64 d0, d7, d0 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ vldr d7, [sp, #40] @ 0x28 │ │ │ │ vldr d13, [sp, #48] @ 0x30 │ │ │ │ - vldr d6, [pc, #764] @ 33e30 │ │ │ │ + vldr d6, [pc, #764] @ 33db8 │ │ │ │ vmul.f64 d14, d13, d9 │ │ │ │ vmul.f64 d5, d7, d8 │ │ │ │ vmul.f64 d6, d13, d6 │ │ │ │ vmul.f64 d7, d7, d15 │ │ │ │ - ldr.w fp, [pc, #832] @ 33e88 │ │ │ │ + ldr.w fp, [pc, #832] @ 33e10 │ │ │ │ add r5, sp, #60 @ 0x3c │ │ │ │ mov r1, r9 │ │ │ │ mov r2, r5 │ │ │ │ vcvt.s32.f64 s9, d14 │ │ │ │ vcvt.s32.f64 s10, d5 │ │ │ │ vcvt.s32.f64 s12, d6 │ │ │ │ vcvt.s32.f64 s14, d7 │ │ │ │ @@ -52305,220 +52296,220 @@ │ │ │ │ sxth.w r8, r3 │ │ │ │ vmov r3, s12 │ │ │ │ strh.w r8, [sp, #62] @ 0x3e │ │ │ │ strh r3, [r4, #0] │ │ │ │ vmov r3, s14 │ │ │ │ sxth r7, r3 │ │ │ │ strh r7, [r4, #2] │ │ │ │ - bl 6590 │ │ │ │ + bl 6528 │ │ │ │ mov r2, r4 │ │ │ │ mov r1, r9 │ │ │ │ mov r0, r4 │ │ │ │ - bl 6590 │ │ │ │ + bl 6528 │ │ │ │ ldrh.w r3, [fp, #28] │ │ │ │ str r3, [sp, #4] │ │ │ │ ldrsh.w r2, [sp, #62] @ 0x3e │ │ │ │ ldrsh.w r3, [r4, #2] │ │ │ │ str r3, [sp, #0] │ │ │ │ ldrsh.w r1, [sp, #60] @ 0x3c │ │ │ │ ldrsh.w r3, [r4] │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ - bl 5fe0 │ │ │ │ + bl 5f78 │ │ │ │ vcvt.s32.f64 s28, d14 │ │ │ │ vmul.f64 d13, d13, d15 │ │ │ │ mov r2, r5 │ │ │ │ mov r1, r9 │ │ │ │ mov r0, r5 │ │ │ │ strh r7, [r4, #2] │ │ │ │ strh.w r8, [sp, #62] @ 0x3e │ │ │ │ vcvt.s32.f64 s26, d13 │ │ │ │ vmov r3, s28 │ │ │ │ strh.w r3, [sp, #60] @ 0x3c │ │ │ │ vmov r3, s26 │ │ │ │ strh r3, [r4, #0] │ │ │ │ - bl 6590 │ │ │ │ + bl 6528 │ │ │ │ mov r2, r4 │ │ │ │ mov r1, r9 │ │ │ │ mov r0, r4 │ │ │ │ - bl 6590 │ │ │ │ + bl 6528 │ │ │ │ ldrsh.w r0, [r4, #2] │ │ │ │ ldrh.w r7, [fp, #28] │ │ │ │ ldrsh.w r3, [r4] │ │ │ │ strd r0, r7, [sp] │ │ │ │ ldrsh.w r2, [sp, #62] @ 0x3e │ │ │ │ ldrsh.w r1, [sp, #60] @ 0x3c │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ - bl 5fe0 │ │ │ │ + bl 5f78 │ │ │ │ adds r6, #10 │ │ │ │ cmp r6, #100 @ 0x64 │ │ │ │ - beq.n 33c70 │ │ │ │ + beq.n 33bf8 │ │ │ │ ldr r3, [sp, #16] │ │ │ │ umull r3, r5, r3, r6 │ │ │ │ movs r3, #30 │ │ │ │ cmp r6, r3 │ │ │ │ mov.w r5, r5, lsr #4 │ │ │ │ mls r5, r3, r5, r6 │ │ │ │ - bgt.w 33afc │ │ │ │ + bgt.w 33a84 │ │ │ │ vmov s15, r6 │ │ │ │ - vldr d6, [pc, #492] @ 33e18 │ │ │ │ - vldr d0, [pc, #496] @ 33e20 │ │ │ │ + vldr d6, [pc, #492] @ 33da0 │ │ │ │ + vldr d0, [pc, #496] @ 33da8 │ │ │ │ add r7, sp, #48 @ 0x30 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ add r1, sp, #40 @ 0x28 │ │ │ │ mov r0, r7 │ │ │ │ - vldr d15, [pc, #488] @ 33e28 │ │ │ │ + vldr d15, [pc, #488] @ 33db0 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ vdiv.f64 d0, d7, d0 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ cmp r5, #0 │ │ │ │ - vldr d4, [pc, #488] @ 33e38 │ │ │ │ - vldr d6, [pc, #476] @ 33e30 │ │ │ │ - vldr d5, [pc, #488] @ 33e40 │ │ │ │ + vldr d4, [pc, #488] @ 33dc0 │ │ │ │ + vldr d6, [pc, #476] @ 33db8 │ │ │ │ + vldr d5, [pc, #488] @ 33dc8 │ │ │ │ it ne │ │ │ │ vmovne.f64 d15, d4 │ │ │ │ vldr d7, [sp, #40] @ 0x28 │ │ │ │ vldr d13, [sp, #48] @ 0x30 │ │ │ │ it ne │ │ │ │ vmovne.f64 d6, d5 │ │ │ │ - b.n 33b34 │ │ │ │ + b.n 33abc │ │ │ │ mov r0, r4 │ │ │ │ - ldr r7, [pc, #536] @ (33e8c ) │ │ │ │ - bl 6484 │ │ │ │ + ldr r7, [pc, #536] @ (33e14 ) │ │ │ │ + bl 641c │ │ │ │ vldr d0, [sp, #8] │ │ │ │ mov r0, r4 │ │ │ │ add r7, pc │ │ │ │ - bl 64a8 │ │ │ │ + bl 6440 │ │ │ │ vmov.f64 d1, d12 │ │ │ │ vmov.f64 d0, d11 │ │ │ │ mov r0, r4 │ │ │ │ - bl 6574 │ │ │ │ - ldr r3, [pc, #508] @ (33e90 ) │ │ │ │ + bl 650c │ │ │ │ + ldr r3, [pc, #508] @ (33e18 ) │ │ │ │ ldr r2, [sp, #24] │ │ │ │ ldr r1, [r7, #52] @ 0x34 │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ ldr r6, [r2, r3] │ │ │ │ mov r3, r4 │ │ │ │ ldr r2, [r1, #0] │ │ │ │ ldr r1, [r1, #8] │ │ │ │ ldrh.w ip, [r6] │ │ │ │ str.w ip, [sp] │ │ │ │ - bl 65fc │ │ │ │ + bl 6594 │ │ │ │ ldr r3, [sp, #28] │ │ │ │ - vldr d0, [pc, #404] @ 33e48 │ │ │ │ + vldr d0, [pc, #404] @ 33dd0 │ │ │ │ mov r0, r4 │ │ │ │ ldr.w r3, [r3, #468] @ 0x1d4 │ │ │ │ vldr d1, [r3, #24] │ │ │ │ vmul.f64 d1, d10, d1 │ │ │ │ - bl 6574 │ │ │ │ + bl 650c │ │ │ │ ldr r1, [r7, #56] @ 0x38 │ │ │ │ ldrh r5, [r6, #0] │ │ │ │ mov r3, r4 │ │ │ │ ldr.w r0, [sl, #32] │ │ │ │ ldr r2, [r1, #0] │ │ │ │ ldr r1, [r1, #8] │ │ │ │ str r5, [sp, #0] │ │ │ │ - bl 65fc │ │ │ │ - ldr r2, [pc, #436] @ (33e94 ) │ │ │ │ - ldr r3, [pc, #440] @ (33e98 ) │ │ │ │ + bl 6594 │ │ │ │ + ldr r2, [pc, #436] @ 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│ │ │ subs r7, #235 @ 0xeb │ │ │ │ - subs r3, #34 @ 0x22 │ │ │ │ + subs r3, #154 @ 0x9a │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - subs r3, #28 │ │ │ │ + subs r3, #148 @ 0x94 │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - str r4, [sp, #960] @ 0x3c0 │ │ │ │ + str r4, [sp, #832] @ 0x340 │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r2, #11 │ │ │ │ + lsls r0, r1, #11 │ │ │ │ movs r0, r0 │ │ │ │ vmov s15, r8 │ │ │ │ mov r1, r6 │ │ │ │ mov r0, r7 │ │ │ │ vcvt.f64.s32 d0, s15 │ │ │ │ vmul.f64 d0, d0, d12 │ │ │ │ vdiv.f64 d0, d0, d11 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ vldr d7, [sp, #128] @ 0x80 │ │ │ │ vldr d6, [sp, #136] @ 0x88 │ │ │ │ vmov.f64 d3, d10 │ │ │ │ vmov.f64 d2, d13 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vmov.f64 d0, d13 │ │ │ │ vmls.f64 d3, d15, d7 │ │ │ │ vmla.f64 d2, d15, d6 │ │ │ │ vmls.f64 d1, d9, d7 │ │ │ │ vmla.f64 d0, d9, d6 │ │ │ │ mov r0, r5 │ │ │ │ add.w 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d15, d10 │ │ │ │ - vldr d10, [pc, #520] @ 34ab8 │ │ │ │ + vldr d10, [pc, #520] @ 34a40 │ │ │ │ ldr.w r5, [r3, #812] @ 0x32c │ │ │ │ ldr r3, [sp, #104] @ 0x68 │ │ │ │ vmul.f64 d10, d15, d10 │ │ │ │ vstr d6, [sp, #48] @ 0x30 │ │ │ │ vldr d0, [r5, #752] @ 0x2f0 │ │ │ │ ldr.w r3, [r3, #468] @ 0x1d4 │ │ │ │ vcmpe.f64 d0, #0.0 │ │ │ │ vldr d11, [r3, #8] │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.w 35022 │ │ │ │ + ble.w 34faa │ │ │ │ vldr d7, [r5, #768] @ 0x300 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bgt.w 355a2 │ │ │ │ + bgt.w 3552a │ │ │ │ vldr d7, [r5, #760] @ 0x2f8 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bgt.w 34fe8 │ │ │ │ + bgt.w 34f70 │ │ │ │ vldr d6, [r5, #776] @ 0x308 │ │ │ │ vcmpe.f64 d6, #0.0 │ │ │ │ vldr d0, [r5, #784] @ 0x310 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.w 35056 │ │ │ │ + ble.w 34fde │ │ │ │ vcmpe.f64 d0, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bgt.w 355f6 │ │ │ │ - ldr r5, [pc, #476] @ (34af4 ) │ │ │ │ + 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0x24 │ │ │ │ vmls.f64 d6, d10, d7 │ │ │ │ vadd.f64 d6, d6, d11 │ │ │ │ vcvt.s32.f64 s15, d6 │ │ │ │ - vldr d6, [pc, #220] @ 34ad0 │ │ │ │ + vldr d6, [pc, #220] @ 34a58 │ │ │ │ vmov r1, s15 │ │ │ │ vmov.f64 d7, d9 │ │ │ │ vmls.f64 d7, d15, d6 │ │ │ │ vadd.f64 d7, d7, d11 │ │ │ │ - vldr d11, [pc, #208] @ 34ad8 │ │ │ │ + vldr d11, [pc, #208] @ 34a60 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r2, s15 │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ ldr r3, [r4, #12] │ │ │ │ - vldr d6, [pc, #200] @ 34ae0 │ │ │ │ + vldr d6, [pc, #200] @ 34a68 │ │ │ │ vmov.f64 d0, #62 @ 0x41f00000 30.0 │ │ │ │ vldr d5, [r3, #232] @ 0xe8 │ │ │ │ vdiv.f64 d7, d5, d6 │ │ │ │ - vldr d6, [pc, #192] @ 34ae8 │ │ │ │ + vldr d6, [pc, #192] @ 34a70 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ vcmp.f64 d7, d0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ it pl │ │ │ │ vmovpl.f64 d0, d7 │ │ │ │ - bl 32ba8 │ │ │ │ + bl 32b30 │ │ │ │ ldrh.w r2, [r9, #28] │ │ │ │ ldr r1, [r4, #36] @ 0x24 │ │ │ │ mov r0, r8 │ │ │ │ vmov.f64 d10, d0 │ │ │ │ - bl 2aa90 │ │ │ │ + bl 2aa18 │ │ │ │ mov r0, r8 │ │ │ │ - bl 2a4a0 │ │ │ │ - b.n 34b00 │ │ │ │ + bl 2a428 │ │ │ │ + b.n 34a88 │ │ │ │ add pc, r0 │ │ │ │ - ldr r2, [pc, #924] @ (34df8 ) │ │ │ │ + ldr r2, [pc, #924] @ (34d80 ) │ │ │ │ ldrsb r0, [r3, r4] │ │ │ │ subs r7, #182 @ 0xb6 │ │ │ │ lsls r0, r2, #26 │ │ │ │ stmia r1!, {r0, r1, r4, r7} │ │ │ │ str r0, [sp, #500] @ 0x1f4 │ │ │ │ subs r7, #208 @ 0xd0 │ │ │ │ add pc, r0 │ │ │ │ - ldr r2, [pc, #924] @ (34e08 ) │ │ │ │ + ldr r2, [pc, #924] @ (34d90 ) │ │ │ │ ldrsb r0, [r3, r4] │ │ │ │ itet lt │ │ │ │ - addlt r3, pc, #860 @ (adr r3, 34dd0 ) │ │ │ │ + addlt r3, pc, #860 @ (adr r3, 34d58 ) │ │ │ │ subge r5, #112 @ 0x70 │ │ │ │ - bvc.n 34a8c @ unpredictable │ │ │ │ + bvc.n 34a14 @ unpredictable │ │ │ │ subs r7, #235 @ 0xeb │ │ │ │ cmp r5, #24 │ │ │ │ strb r4, [r0, r1] │ │ │ │ movs r1, #251 @ 0xfb │ │ │ │ subs r7, #249 @ 0xf9 │ │ │ │ ldrh r1, [r6, #14] │ │ │ │ - b.n 34f24 │ │ │ │ + b.n 34eac │ │ │ │ strh r7, [r1, r1] │ │ │ │ subs r7, #253 @ 0xfd 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0x58 │ │ │ │ vcvt.f64.s32 d1, s2 │ │ │ │ mov r0, r4 │ │ │ │ vcvt.f64.s32 d0, s0 │ │ │ │ vadd.f64 d1, d1, d14 │ │ │ │ vadd.f64 d0, d0, d14 │ │ │ │ - bl 33828 │ │ │ │ + bl 337b0 │ │ │ │ ldrsh.w r3, [r4, #132] @ 0x84 │ │ │ │ vmov s16, r3 │ │ │ │ ldrsh.w r3, [r4, #134] @ 0x86 │ │ │ │ vmov s18, r3 │ │ │ │ ldr r3, [r4, #36] @ 0x24 │ │ │ │ vcvt.f64.s32 d8, s16 │ │ │ │ add.w r1, r4, #132 @ 0x84 │ │ │ │ vcvt.f64.s32 d9, s18 │ │ │ │ ldr r0, [r3, #4] │ │ │ │ - bl 4dd0 │ │ │ │ + bl 4d68 │ │ │ │ vadd.f64 d8, d8, d14 │ │ │ │ - bl 2a4b4 │ │ │ │ + bl 2a43c │ │ │ │ vadd.f64 d9, d9, d14 │ │ │ │ vmov.f64 d2, d15 │ │ │ │ mov r8, r0 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vmov.f64 d1, d9 │ │ │ │ - bl 2a650 │ │ │ │ - vldr d7, [pc, #252] @ 34ca0 │ │ │ │ - ldr r3, [pc, #280] @ (34cc0 ) │ │ │ │ + bl 2a5d8 │ │ │ │ + vldr d7, [pc, #252] @ 34c28 │ │ │ │ + ldr r3, [pc, #280] @ (34c48 ) │ │ │ │ vmul.f64 d11, d15, d11 │ │ │ │ vmul.f64 d7, d15, d7 │ │ │ │ add r3, pc │ │ │ │ str r3, [sp, #24] │ │ │ │ vstr d7, [sp, #16] │ │ │ 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#20] │ │ │ │ + str r6, [r3, #56] @ 0x38 │ │ │ │ movs r1, r0 │ │ │ │ - str r2, [r0, #40] @ 0x28 │ │ │ │ + str r6, [r6, #72] @ 0x48 │ │ │ │ movs r1, r0 │ │ │ │ - str r4, [r3, #76] @ 0x4c │ │ │ │ + str r0, [r2, #112] @ 0x70 │ │ │ │ movs r1, r0 │ │ │ │ - str r6, [r0, #76] @ 0x4c │ │ │ │ + str r2, [r7, #108] @ 0x6c │ │ │ │ movs r1, r0 │ │ │ │ - str r4, [r1, #72] @ 0x48 │ │ │ │ + str r0, [r0, #108] @ 0x6c │ │ │ │ movs r1, r0 │ │ │ │ - asrs r4, r5, #5 │ │ │ │ + asrs r4, r4, #3 │ │ │ │ movs r2, r0 │ │ │ │ vmov.f64 d12, d11 │ │ │ │ vmov.f64 d14, d11 │ │ │ │ vmls.f64 d12, d6, d13 │ │ │ │ vmls.f64 d14, d6, d15 │ │ │ │ vmul.f64 d13, d8, d13 │ │ │ │ vmul.f64 d8, d8, d15 │ │ │ │ mov r0, fp │ │ │ │ vsub.f64 d3, d9, d8 │ │ │ │ vsub.f64 d1, d9, d13 │ │ │ │ vmov.f64 d2, d14 │ │ │ │ vmov.f64 d0, d12 │ │ │ │ - bl 2a50c │ │ │ │ + bl 2a494 │ │ │ │ cmp r6, #0 │ │ │ │ - bne.n 3557a │ │ │ │ + bne.n 35502 │ │ │ │ vldmia r9!, {d12} │ │ │ │ adds r6, #1 │ │ │ │ vcmpe.f64 d12, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - blt.w 34cc8 │ │ │ │ + blt.w 34c50 │ │ │ │ vmov.f64 d0, d12 │ │ │ │ - bl 32c44 │ │ │ │ + bl 32bcc │ │ │ │ ldr r0, [sp, #48] @ 0x30 │ │ │ │ mov r1, r4 │ │ │ │ - blx 3074 │ │ │ │ - vldr d7, [pc, #804] @ 35808 │ │ │ │ + blx 3028 │ │ │ │ + vldr d7, [pc, #804] @ 35790 │ │ │ │ vldr d6, [sp, #128] @ 0x80 │ │ │ │ mov r0, r5 │ │ │ │ - ldr r1, [pc, #820] @ (35820 ) │ │ │ │ + ldr r1, [pc, #820] @ (357a8 ) │ │ │ │ vdiv.f64 d7, d12, d7 │ │ │ │ vldr d8, [sp, #136] @ 0x88 │ │ │ │ add r1, pc │ │ │ │ vstr d6, [sp, #24] │ │ │ │ vmov r2, r3, d7 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ vmov.f64 d7, #96 @ 0x3f000000 0.5 │ │ │ │ vldr d13, [sp, #16] │ │ │ │ vadd.f64 d7, d12, d7 │ │ │ │ vldr d6, [sp, #24] │ │ │ │ vcvt.s32.f64 s14, d7 │ │ │ │ vmov r3, s14 │ │ │ │ mla r3, r7, r3, r8 │ │ │ │ cmp.w sl, r3, ror #2 │ │ │ │ - bcc.n 3548c │ │ │ │ + bcc.n 35414 │ │ │ │ vldr d7, [sp, #32] │ │ │ │ vmov.f64 d12, d11 │ │ │ │ - ldr r3, [pc, #756] @ (35824 ) │ │ │ │ + ldr r3, [pc, #756] @ (357ac ) │ │ │ │ mov r1, r5 │ │ │ │ vldr d13, [sp, #72] @ 0x48 │ │ │ │ vmls.f64 d12, d6, d7 │ │ │ │ vmul.f64 d14, d8, d7 │ │ │ │ add r3, pc │ │ │ │ ldr r2, [sp, #60] @ 0x3c │ │ │ │ vmov.f64 d2, d13 │ │ │ │ str r3, [sp, #64] @ 0x40 │ │ │ │ ldr r0, [r2, #36] @ 0x24 │ │ │ │ vsub.f64 d1, d9, d14 │ │ │ │ ldrh r2, [r3, #28] │ │ │ │ vmov.f64 d0, d12 │ │ │ │ - bl 2aac0 │ │ │ │ + bl 2aa48 │ │ │ │ ldr r3, [sp, #64] @ 0x40 │ │ │ │ vmov.f64 d2, d13 │ │ │ │ vadd.f64 d1, d9, d14 │ │ │ │ vmov.f64 d0, d12 │ │ │ │ mov r1, r5 │ │ │ │ ldrh r2, [r3, #28] │ │ │ │ ldr r3, [sp, #60] @ 0x3c │ │ │ │ ldr r0, [r3, #36] @ 0x24 │ │ │ │ - bl 2aac0 │ │ │ │ + bl 2aa48 │ │ │ │ vldr d13, [sp, #80] @ 0x50 │ │ │ │ vldr d6, [sp, #24] │ │ │ │ - b.n 3548c │ │ │ │ + b.n 35414 │ │ │ │ vadd.f64 d3, d9, d8 │ │ │ │ vadd.f64 d1, d9, d13 │ │ │ │ vmov.f64 d2, d14 │ │ │ │ vmov.f64 d0, d12 │ │ │ │ mov r0, fp │ │ │ │ - bl 2a50c │ │ │ │ - b.n 354be │ │ │ │ - vldr d6, [pc, #636] @ 35810 │ │ │ │ + bl 2a494 │ │ │ │ + b.n 35446 │ │ │ │ + vldr d6, [pc, #636] @ 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0x308 │ │ │ │ mov fp, r0 │ │ │ │ - bl 32ba8 │ │ │ │ + bl 32b30 │ │ │ │ vsub.f64 d11, d0, d12 │ │ │ │ vldr d0, [r5, #784] @ 0x310 │ │ │ │ - bl 32ba8 │ │ │ │ + bl 32b30 │ │ │ │ vsub.f64 d12, d0, d12 │ │ │ │ vmov.f64 d2, d10 │ │ │ │ vmov.f64 d1, d9 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ mov r0, fp │ │ │ │ vmov.f64 d3, d11 │ │ │ │ vmov.f64 d4, d12 │ │ │ │ - bl 3305c │ │ │ │ + bl 32fe4 │ │ │ │ vmov.f64 d4, d12 │ │ │ │ vmov.f64 d3, d11 │ │ │ │ vmov.f64 d1, d9 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vldr d2, [sp, #48] @ 0x30 │ │ │ │ mov r0, fp │ │ │ │ - bl 3305c │ │ │ │ - ldr r3, [pc, #472] @ (35828 ) │ │ │ │ + bl 32fe4 │ │ │ │ + ldr r3, [pc, #472] @ (357b0 ) │ │ │ │ mov r0, fp │ │ │ │ ldr r1, [r4, #36] @ 0x24 │ │ │ │ ldr.w r3, [r9, r3] │ │ │ │ ldrh r2, [r3, #0] │ │ │ │ - bl 2aa90 │ │ │ │ + bl 2aa18 │ │ │ │ mov r0, fp │ │ │ │ - bl 2a4a0 │ │ │ │ - b.n 35052 │ │ │ │ + bl 2a428 │ │ │ │ + b.n 34fda │ │ │ │ movw r2, #34953 @ 0x8889 │ │ │ │ movt r2, #34952 @ 0x8888 │ │ │ │ mov r0, r5 │ │ │ │ smull r1, r2, r2, r3 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+ beq.w 34e6e │ │ │ │ + ldr r3, [pc, #300] @ (357c8 ) │ │ │ │ add r3, pc │ │ │ │ ldr r2, [r3, #88] @ 0x58 │ │ │ │ clz r2, r2 │ │ │ │ lsrs r2, r2, #5 │ │ │ │ - b.w 34ee6 │ │ │ │ + b.w 34e6e │ │ │ │ ldr r0, [r4, #12] │ │ │ │ - bl 23c34 │ │ │ │ + bl 23bbc │ │ │ │ movs r2, #1 │ │ │ │ cmp r0, #0 │ │ │ │ - beq.w 34ecc │ │ │ │ - ldr r3, [pc, #272] @ (35844 ) │ │ │ │ + beq.w 34e54 │ │ │ │ + ldr r3, [pc, #272] @ (357cc ) │ │ │ │ add r3, pc │ │ │ │ ldr r2, [r3, #88] @ 0x58 │ │ │ │ clz r2, r2 │ │ │ │ lsrs r2, r2, #5 │ │ │ │ - b.w 34ecc │ │ │ │ + b.w 34e54 │ │ │ │ movw r2, #46021 @ 0xb3c5 │ │ │ │ movt r2, #37282 @ 0x91a2 │ │ │ │ asrs r0, r3, #31 │ │ │ │ smull r1, r2, r2, r3 │ │ │ │ add r2, r3 │ │ │ │ asrs r2, r2, #11 │ │ │ │ subs r1, r2, r0 │ │ │ │ @@ -54621,357 +54612,357 @@ │ │ │ │ movt r3, #34952 @ 0x8888 │ │ │ │ umull r0, r3, r3, r1 │ │ │ │ movs r0, #60 @ 0x3c │ │ │ │ lsrs r3, r3, #5 │ │ │ │ mls r1, r0, r3, r1 │ │ │ │ mov r0, r5 │ │ │ │ str r1, [sp, #0] │ │ │ │ - ldr r1, [pc, #208] @ (35848 ) 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67bc │ │ │ │ ldr r3, [r0, #0] │ │ │ │ str.w r0, [r8, #40] @ 0x28 │ │ │ │ cmp r3, #0 │ │ │ │ itt gt │ │ │ │ ldrgt r1, [r0, #8] │ │ │ │ addgt.w r3, r1, r3, lsl #2 │ │ │ │ - ble.n 35a32 │ │ │ │ + ble.n 359ba │ │ │ │ ldrh.w r2, [r3, #-2] │ │ │ │ subs r3, #4 │ │ │ │ negs r2, r2 │ │ │ │ strh r2, [r3, #2] │ │ │ │ cmp r1, r3 │ │ │ │ - bne.n 35a24 │ │ │ │ - ldr r4, [pc, #484] @ (35c18 ) │ │ │ │ - bl 6740 │ │ │ │ + bne.n 359ac │ │ │ │ + ldr r4, [pc, #484] @ (35ba0 ) │ │ │ │ + bl 66d8 │ │ │ │ movs r1, #0 │ │ │ │ movw r2, #64836 @ 0xfd44 │ │ │ │ movt r2, #65535 @ 0xffff │ │ │ │ add r4, pc │ │ │ │ add.w r8, sp, #20 │ │ │ │ - ldr.w r9, [pc, #464] @ 35c1c │ │ │ │ + ldr.w r9, [pc, #464] @ 35ba4 │ │ │ │ str r0, [r4, #48] @ 0x30 │ │ │ │ - bl 6788 │ │ │ │ + bl 6720 │ │ │ │ ldr r0, [r4, #48] @ 0x30 │ │ │ │ mvn.w r1, #99 @ 0x63 │ │ │ │ movw r2, #64536 @ 0xfc18 │ │ │ │ movt r2, #65535 @ 0xffff │ │ │ │ - bl 6788 │ │ │ │ + bl 6720 │ │ │ │ ldr r0, [r4, #48] @ 0x30 │ │ │ │ movs r1, #100 @ 0x64 │ │ │ │ movw r2, #64536 @ 0xfc18 │ │ │ │ movt r2, #65535 @ 0xffff │ │ │ │ add r9, pc │ │ │ │ - bl 6788 │ │ │ │ - bl 6740 │ │ │ │ + bl 6720 │ │ │ │ + bl 66d8 │ │ │ │ mvn.w r1, #99 @ 0x63 │ │ │ │ movw r2, #65036 @ 0xfe0c │ │ │ │ movt r2, #65535 @ 0xffff │ │ │ │ str r0, [r4, #52] @ 0x34 │ │ │ │ - bl 6788 │ │ │ │ + bl 6720 │ │ │ │ ldr r0, [r4, #52] @ 0x34 │ │ │ │ movs r1, #100 @ 0x64 │ │ │ │ movw r2, #65036 @ 0xfe0c │ │ │ │ movt r2, #65535 @ 0xffff │ │ │ │ - bl 6788 │ │ │ │ + bl 6720 │ │ │ │ ldr r0, [r4, #52] @ 0x34 │ │ │ │ movs r1, #0 │ │ │ │ movw r2, #64836 @ 0xfd44 │ │ │ │ movt r2, #65535 @ 0xffff │ │ │ │ - bl 6788 │ │ │ │ - ldr r3, [pc, #368] @ (35c20 ) │ │ │ │ + bl 6720 │ │ │ │ + ldr r3, [pc, #368] @ (35ba8 ) │ │ │ │ add r3, pc │ │ │ │ adds r3, #88 @ 0x58 │ │ │ │ ldmia r3, {r0, r1, r2, r3} │ │ │ │ stmia.w r8, {r0, r1, r2, r3} │ │ │ │ - bl 6740 │ │ │ │ + bl 66d8 │ │ │ │ str r0, [r4, #56] @ 0x38 │ │ │ │ add r4, sp, #32 │ │ │ │ mov r1, r4 │ │ │ │ - bl 67d4 │ │ │ │ + bl 676c │ │ │ │ cmp r8, r4 │ │ │ │ - beq.n 35ada │ │ │ │ + beq.n 35a62 │ │ │ │ subs r4, #4 │ │ │ │ ldr.w r0, [r9, #56] @ 0x38 │ │ │ │ mov r1, r4 │ │ │ │ - bl 67d4 │ │ │ │ + bl 676c │ │ │ │ cmp r8, r4 │ │ │ │ - bne.n 35aca │ │ │ │ - ldr r2, [pc, #328] @ (35c24 ) │ │ │ │ + bne.n 35a52 │ │ │ │ + ldr r2, [pc, #328] @ (35bac ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, #64] @ 0x40 │ │ │ │ cmp r3, #0 │ │ │ │ - beq.n 35b66 │ │ │ │ + beq.n 35aee │ │ │ │ ldr r1, [r3, #0] │ │ │ │ str.w r3, [r6, #468] @ 0x1d4 │ │ │ │ str r1, [r2, #64] @ 0x40 │ │ │ │ movs r2, #0 │ │ │ │ str r2, [r3, #0] │ │ │ │ ldr.w r4, [r6, #468] @ 0x1d4 │ │ │ │ ldr r3, [r5, #12] │ │ │ │ addw r9, pc, #216 @ 0xd8 │ │ │ │ ldrd r8, r9, [r9] │ │ │ │ ldr.w r3, [r3, #812] @ 0x32c │ │ │ │ vldr d0, [r3, #744] @ 0x2e8 │ │ │ │ - blx 3210 │ │ │ │ - ldr r3, [pc, #284] @ (35c28 ) │ │ │ │ + blx 31c8 │ │ │ │ + ldr r3, [pc, #284] @ (35bb0 ) │ │ │ │ strd r8, r9, [r4, #32] │ │ │ │ movs r1, #0 │ │ │ │ strd r8, r9, [r4, #40] @ 0x28 │ │ │ │ movs r0, #0 │ │ │ │ addw r9, pc, #188 @ 0xbc │ │ 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blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 35a7c │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ ands r0, r0 │ │ │ │ stmia r0!, {r0, r1, r2, r3, r7} │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ ands r0, r0 │ │ │ │ @@ -54983,19 +54974,19 @@ │ │ │ │ ands r1, r1 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ strh r0, [r0, #0] │ │ │ │ eors r6, r4 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ - b.n 35bb0 │ │ │ │ + b.n 35b38 │ │ │ │ stmia r0!, {r0, r2, r7} │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ - b.n 35bb8 │ │ │ │ + b.n 35b40 │ │ │ │ lsls r5, r0 │ │ │ │ strb r7, [r0, #14] │ │ │ │ ldrb r3, [r1, #24] │ │ │ │ subs r2, #26 │ │ │ │ subs r7, #198 @ 0xc6 │ │ │ │ adds r7, r2, #0 │ │ │ │ ldrh r1, [r0, #36] @ 0x24 │ │ │ │ @@ -55005,117 +54996,117 @@ │ │ │ │ mov r0, r0 │ │ │ │ mov r0, r0 │ │ │ │ eor r6, r1 │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #201 @ 0xc9 │ │ │ │ - add r5, pc, #908 @ (adr r5, 35f68 ) │ │ │ │ + add r5, pc, #908 @ (adr r5, 35ef0 ) │ │ │ │ stmia r4!, {r0, r1, r3, r4, r7} │ │ │ │ add sp, #128 @ 0x80 │ │ │ │ itee al │ │ │ │ - moval r7, #142 @ 0x8e │ │ │ │ + cmpal r0, #6 │ │ │ │ mov r2, r0 │ │ │ │ - lsl r0, r3, #11 │ │ │ │ + lsl r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - movs r7, #138 @ 0x8a │ │ │ │ + cmp r0, #2 │ │ │ │ movs r2, r0 │ │ │ │ - movs r7, #112 @ 0x70 │ │ │ │ + movs r7, #232 @ 0xe8 │ │ │ │ movs r2, r0 │ │ │ │ - strh r6, [r4, #10] │ │ │ │ + strh r6, [r0, #10] │ │ │ │ movs r2, r0 │ │ │ │ @ instruction: 0xe9bfffff │ │ │ │ - ldrsh r0, [r5, r4] │ │ │ │ + ldr r0, [pc, #320] @ (35cc4 ) │ │ │ │ movs r1, r0 │ │ │ │ - ldrsh r2, [r4, r4] │ │ │ │ + ldr r0, [pc, #232] @ (35c70 ) │ │ │ │ movs r1, r0 │ │ │ │ - ldrsh r4, [r3, r4] │ │ │ │ + str r0, [r0, #20] │ │ │ │ movs r1, r0 │ │ │ │ - ldrsh r6, [r2, r4] │ │ │ │ + str r2, [r7, #16] │ │ │ │ movs r1, r0 │ │ │ │ - ldrsh r0, [r2, r4] │ │ │ │ + str r4, [r6, #16] │ │ │ │ movs r1, r0 │ │ │ │ - ldrsh r2, [r1, r4] │ │ │ │ + str r6, [r5, #16] │ │ │ │ movs r1, r0 │ │ │ │ - strh r2, [r3, #6] │ │ │ │ + strh r2, [r7, #4] │ │ │ │ movs r2, r0 │ │ │ │ - strh r0, [r7, #2] │ │ │ │ + strh r0, [r3, #2] │ │ │ │ movs r2, r0 │ │ │ │ - ldrb r2, [r2, #31] │ │ │ │ + ldrb r2, [r6, #30] │ │ │ │ movs r2, r0 │ │ │ │ - ldrb r4, [r4, #30] │ │ │ │ + ldrb r4, [r0, #30] │ │ │ │ movs r2, r0 │ │ │ │ - lsrs r6, r1, #9 │ │ │ │ + lsrs r6, r0, #7 │ │ │ │ movs r2, r0 │ │ │ │ - ldrb r0, [r7, #28] │ │ │ │ + ldrb r0, [r3, #28] │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - ldrb r6, [r7, r2] │ │ │ │ + ldrsh r2, [r4, r3] │ │ │ │ movs r1, r0 │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r3, [r0, #468] @ 0x1d4 │ │ │ │ - cbz r3, 35c3e │ │ │ │ + cbz r3, 35bc6 │ │ │ │ movs r2, #0 │ │ │ │ str r2, [r3, #4] │ │ │ │ bx lr │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r0, [r0, #468] @ 0x1d4 │ │ │ │ - cbz r0, 35c52 │ │ │ │ + cbz r0, 35bda │ │ │ │ ldr r0, [r0, #4] │ │ │ │ subs r0, #0 │ │ │ │ it ne │ │ │ │ movne r0, #1 │ │ │ │ bx lr │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r2, [r0, #468] @ 0x1d4 │ │ │ │ - cbz r2, 35c76 │ │ │ │ - ldr r3, [pc, #24] @ (35c78 ) │ │ │ │ + cbz r2, 35bfe │ │ │ │ + ldr r3, [pc, #24] @ (35c00 ) │ │ │ │ movs r1, #0 │ │ │ │ push {r4} │ │ │ │ add r3, pc │ │ │ │ ldr r4, [r3, #64] @ 0x40 │ │ │ │ str r4, [r2, #0] │ │ │ │ str r2, [r3, #64] @ 0x40 │ │ │ │ ldr.w r4, [sp], #4 │ │ │ │ str.w r1, [r0, #468] @ 0x1d4 │ │ │ │ bx lr │ │ │ │ bx lr │ │ │ │ - ldrb r0, [r6, #22] │ │ │ │ + ldrb r0, [r2, #22] │ │ │ │ movs r2, r0 │ │ │ │ - cbz r0, 35c84 │ │ │ │ + cbz r0, 35c0c │ │ │ │ ldr r0, [r0, #16] │ │ │ │ - b.w 13b48 │ │ │ │ + b.w 13c20 │ │ │ │ bx lr │ │ │ │ nop │ │ │ │ push {r4, r5, r6, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4080] @ 0xff0 │ │ │ │ - ldr r5, [pc, #44] @ (35cc4 ) │ │ │ │ + ldr r5, [pc, #44] @ (35c4c ) │ │ │ │ mov r6, r0 │ │ │ │ - ldr r3, [pc, #44] @ (35cc8 ) │ │ │ │ + ldr r3, [pc, #44] @ (35c50 ) │ │ │ │ movs r2, #24 │ │ │ │ add r5, pc │ │ │ │ movs r1, #38 @ 0x26 │ │ │ │ add r3, pc │ │ │ │ mov r0, r5 │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ movs r2, #24 │ │ │ │ mov r4, r0 │ │ │ │ movs r3, #0 │ │ │ │ mov r0, r5 │ │ │ │ movs r1, #39 @ 0x27 │ │ │ │ mul.w r2, r6, r2 │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ mov r3, r0 │ │ │ │ mov r0, r4 │ │ │ │ str r3, [r4, #16] │ │ │ │ pop {r4, r5, r6, pc} │ │ │ │ - ldrh r6, [r3, r6] │ │ │ │ + ldrb r2, [r0, r7] │ │ │ │ movs r1, r0 │ │ │ │ @ instruction: 0xffd7ffff │ │ │ │ push {lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4064] @ 0xfe0 │ │ │ │ vldr d7, [r0, #8] │ │ │ │ @@ -55124,409 +55115,409 @@ │ │ │ │ vmov.f64 d6, d0 │ │ │ │ ldr r2, [r0, #16] │ │ │ │ sub sp, #28 │ │ │ │ vcmpe.f64 d7, d0 │ │ │ │ mla r1, r1, r3, r2 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ vldr d5, [r1, #-24] @ 0xffffffe8 │ │ │ │ - bhi.n 35d4c │ │ │ │ + bhi.n 35cd4 │ │ │ │ vcmpe.f64 d0, d5 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bhi.n 35d4c │ │ │ │ + bhi.n 35cd4 │ │ │ │ cmp r3, #0 │ │ │ │ it le │ │ │ │ movle r3, #0 │ │ │ │ - ble.n 35d3a │ │ │ │ + ble.n 35cc2 │ │ │ │ movs r1, #0 │ │ │ │ - b.n 35d1a │ │ │ │ + b.n 35ca2 │ │ │ │ adds r1, #1 │ │ │ │ adds r2, #24 │ │ │ │ cmp r3, r1 │ │ │ │ - beq.n 35d3a │ │ │ │ + beq.n 35cc2 │ │ │ │ vldr d7, [r2] │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - blt.n 35d12 │ │ │ │ + blt.n 35c9a │ │ │ │ vldr d7, [r2, #8] │ │ │ │ vldr d0, [r2, #16] │ │ │ │ vmla.f64 d0, d6, d7 │ │ │ │ add sp, #28 │ │ │ │ ldr.w pc, [sp], #4 │ │ │ │ - ldr r2, [pc, #48] @ (35d6c ) │ │ │ │ + ldr r2, [pc, #48] @ (35cf4 ) │ │ │ │ movs r1, #60 @ 0x3c │ │ │ │ - ldr r0, [pc, #48] @ (35d70 ) │ │ │ │ + ldr r0, [pc, #48] @ (35cf8 ) │ │ │ │ add r2, pc │ │ │ │ add r0, pc │ │ │ │ - bl 12824 │ │ │ │ - blx 2f44 │ │ │ │ - ldr r2, [pc, #36] @ (35d74 ) │ │ │ │ + bl 12f94 │ │ │ │ + blx 2ef4 │ │ │ │ + ldr r2, [pc, #36] @ (35cfc ) │ │ │ │ movs r1, #49 @ 0x31 │ │ │ │ - ldr r0, [pc, #36] @ (35d78 ) │ │ │ │ + ldr r0, [pc, #36] @ (35d00 ) │ │ │ │ add r2, pc │ │ │ │ vstr d5, [sp, #16] │ │ │ │ add r0, pc │ │ │ │ vstr d7, [sp, #8] │ │ │ │ vstr d6, [sp] │ │ │ │ - bl 12824 │ │ │ │ - blx 2f44 │ │ │ │ + bl 12f94 │ │ │ │ + blx 2ef4 │ │ │ │ nop │ │ │ │ - ldrh r4, [r0, r5] │ │ │ │ + ldrb r0, [r5, r5] │ │ │ │ movs r1, r0 │ │ │ │ - ldrh r2, [r7, r3] │ │ │ │ + ldrb r6, [r3, r4] │ │ │ │ movs r1, r0 │ │ │ │ - ldrh r2, [r7, r3] │ │ │ │ + ldrb r6, [r3, r4] │ │ │ │ movs r1, r0 │ │ │ │ - ldrh r4, [r4, r3] │ │ │ │ + ldrb r0, [r1, r4] │ │ │ │ movs r1, r0 │ │ │ │ stmdb sp!, {r3, r4, r5, r6, r7, r8, r9, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4064] @ 0xfe0 │ │ │ │ mov r8, r0 │ │ │ │ mov r7, r0 │ │ │ │ - cbz r0, 35dfe │ │ │ │ - ldr r6, [pc, #112] @ (35e04 ) │ │ │ │ + cbz r0, 35d86 │ │ │ │ + ldr r6, [pc, #112] @ (35d8c ) │ │ │ │ movs r2, #24 │ │ │ │ - ldr r3, [pc, #112] @ (35e08 ) │ │ │ │ + ldr r3, [pc, #112] @ (35d90 ) │ │ │ │ movs r1, #72 @ 0x48 │ │ │ │ add r6, pc │ │ │ │ mov r5, r8 │ │ │ │ add r3, pc │ │ │ │ mov r0, r6 │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ mov r4, r0 │ │ │ │ mov r7, r0 │ │ │ │ mov.w r9, #24 │ │ │ │ ldmia r5!, {r0, r1, r2, r3} │ │ │ │ stmia r4!, {r0, r1, r2, r3} │ │ │ │ movs r3, #0 │ │ │ │ ldr.w r2, [r8] │ │ │ │ ldmia.w r5, {r0, r1} │ │ │ │ stmia.w r4, {r0, r1} │ │ │ │ mul.w r2, r9, r2 │ │ │ │ mov r0, r6 │ │ │ │ movs r1, #74 @ 0x4a │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ ldr r6, [r7, #0] │ │ │ │ mov r5, r0 │ │ │ │ str r0, [r7, #16] │ │ │ │ cmp r6, #0 │ │ │ │ - ble.n 35dfe │ │ │ │ + ble.n 35d86 │ │ │ │ ldr.w r8, [r8, #16] │ │ │ │ mul.w r6, r9, r6 │ │ │ │ movs r4, #0 │ │ │ │ add.w lr, r8, r4 │ │ │ │ add.w ip, r5, r4 │ │ │ │ adds r4, #24 │ │ │ │ cmp r4, r6 │ │ │ │ ldmia.w lr!, {r0, r1, r2, r3} │ │ │ │ stmia.w ip!, {r0, r1, r2, r3} │ │ │ │ ldmia.w lr, {r0, r1} │ │ │ │ stmia.w ip, {r0, r1} │ │ │ │ - bne.n 35de0 │ │ │ │ + bne.n 35d68 │ │ │ │ mov r0, r7 │ │ │ │ ldmia.w sp!, {r3, r4, r5, r6, r7, r8, r9, pc} │ │ │ │ - ldrh r2, [r4, r2] │ │ │ │ + ldrb r6, [r0, r3] │ │ │ │ movs r1, r0 │ │ │ │ mrc2 15, 6, pc, cr11, cr15, {7} │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ push {r4, r5, r6, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4080] @ 0xff0 │ │ │ │ - ldr r1, [pc, #72] @ (35e68 ) │ │ │ │ + ldr r1, [pc, #72] @ (35df0 ) │ │ │ │ mov r6, r0 │ │ │ │ add r1, pc │ │ │ │ - blx 3238 │ │ │ │ + blx 31f0 │ │ │ │ mov r5, r0 │ │ │ │ - cbz r0, 35e58 │ │ │ │ - ldr r0, [pc, #60] @ (35e6c ) │ │ │ │ + cbz r0, 35de0 │ │ │ │ + ldr r0, [pc, #60] @ (35df4 ) │ │ │ │ movs r3, #0 │ │ │ │ movs r2, #152 @ 0x98 │ │ │ │ mov.w r1, #442 @ 0x1ba │ │ │ │ add r0, pc │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ mov r4, r0 │ │ │ │ mov r0, r6 │ │ │ │ - bl 13d7c │ │ │ │ - vldr d7, [pc, #24] @ 35e60 │ │ │ │ + bl 13e54 │ │ │ │ + vldr d7, [pc, #24] @ 35de8 │ │ │ │ movs r3, #0 │ │ │ │ str r0, [r4, #0] │ │ │ │ str r3, [r4, #20] │ │ │ │ str r5, [r4, #4] │ │ │ │ vstr d7, [r4, #8] │ │ │ │ mov r0, r4 │ │ │ │ pop {r4, r5, r6, pc} │ │ │ │ mov r4, r0 │ │ │ │ - b.n 35e54 │ │ │ │ + b.n 35ddc │ │ │ │ nop.w │ │ │ │ movs r1, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ - str r2, [r5, #120] @ 0x78 │ │ │ │ + ldr r6, [r1, #28] │ │ │ │ movs r1, r0 │ │ │ │ - ldrh r6, [r2, r1] │ │ │ │ + ldrb r2, [r7, r1] │ │ │ │ movs r1, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4056] @ 0xfd8 │ │ │ │ mov r4, r0 │ │ │ │ - ldr.w r0, [pc, #1152] @ 36304 │ │ │ │ - ldr.w r1, [pc, #1152] @ 36308 │ │ │ │ + ldr.w r0, [pc, #1152] @ 3628c │ │ │ │ + ldr.w r1, [pc, #1152] @ 36290 │ │ │ │ sub sp, #8 │ │ │ │ add r0, pc │ │ │ │ - ldr.w r3, [pc, #1148] @ 3630c │ │ │ │ - ldr.w r7, [pc, #1148] @ 36310 │ │ │ │ + ldr.w r3, [pc, #1148] @ 36294 │ │ │ │ + ldr.w r7, [pc, #1148] @ 36298 │ │ │ │ movs r2, #0 │ │ │ │ - ldr.w r9, [pc, #1144] @ 36314 │ │ │ │ + ldr.w r9, [pc, #1144] @ 3629c │ │ │ │ add r3, pc │ │ │ │ - ldr.w r8, [pc, #1144] @ 36318 │ │ │ │ + ldr.w r8, [pc, #1144] @ 362a0 │ │ │ │ add r7, pc │ │ │ │ ldr r1, [r0, r1] │ │ │ │ add r9, pc │ │ │ │ ldr r6, [r4, #12] │ │ │ │ add r8, pc │ │ │ │ ldr r1, [r1, #0] │ │ │ │ str r1, [sp, #4] │ │ │ │ mov.w r1, #0 │ │ │ │ str r2, [r3, #0] │ │ │ │ cmp r6, #0 │ │ │ │ - beq.w 36174 │ │ │ │ + beq.w 360fc │ │ │ │ movs r6, #0 │ │ │ │ ldr r5, [r4, #16] │ │ │ │ movs r3, #0 │ │ │ │ str r3, [r4, #12] │ │ │ │ adds r3, r5, #1 │ │ │ │ - beq.w 3616e │ │ │ │ + beq.w 360f6 │ │ │ │ cmp r6, #4 │ │ │ │ - bhi.w 362f8 │ │ │ │ + bhi.w 36280 │ │ │ │ tbb [pc, r6] │ │ │ │ adds r6, #20 │ │ │ │ str r0, [sp, #216] @ 0xd8 │ │ │ │ lsls r4, r5, #1 │ │ │ │ ldrd r2, r3, [r4, #8] │ │ │ │ adds r2, #1 │ │ │ │ str r2, [r4, #8] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 35ebc │ │ │ │ + bne.n 35e44 │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - beq.w 3618c │ │ │ │ + beq.w 36114 │ │ │ │ adds r2, r0, #1 │ │ │ │ - beq.w 3616e │ │ │ │ - blx 3384 <__ctype_b_loc@plt> │ │ │ │ + beq.w 360f6 │ │ │ │ + blx 333c <__ctype_b_loc@plt> │ │ │ │ ldr r3, [r0, #0] │ │ │ │ ldrh.w r3, [r3, r5, lsl #1] │ │ │ │ lsls r6, r3, #21 │ │ │ │ - bpl.w 36020 │ │ │ │ - ldr.w sl, [pc, #1036] @ 3631c │ │ │ │ + bpl.w 35fa8 │ │ │ │ + ldr.w sl, [pc, #1036] @ 362a4 │ │ │ │ movs r6, #1 │ │ │ │ add sl, pc │ │ │ │ ldr.w r3, [sl] │ │ │ │ add.w r2, sl, r3 │ │ │ │ add r3, r6 │ │ │ │ str.w r3, [sl] │ │ │ │ strb r5, [r2, #4] │ │ │ │ ldr r3, [r4, #12] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 35ebe │ │ │ │ + bne.n 35e46 │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - beq.w 36216 │ │ │ │ + beq.w 3619e │ │ │ │ adds r0, r5, #1 │ │ │ │ - beq.w 3616e │ │ │ │ - blx 3384 <__ctype_b_loc@plt> │ │ │ │ + beq.w 360f6 │ │ │ │ + blx 333c <__ctype_b_loc@plt> │ │ │ │ ldr r2, [r0, #0] │ │ │ │ ldr.w r3, [r9] │ │ │ │ ldrh.w r2, [r2, r5, lsl #1] │ │ │ │ lsls r1, r2, #18 │ │ │ │ - bmi.w 3622e │ │ │ │ + bmi.w 361b6 │ │ │ │ cmp r5, #44 @ 0x2c │ │ │ │ it ne │ │ │ │ cmpne r5, #58 @ 0x3a │ │ │ │ - beq.w 3622e │ │ │ │ + beq.w 361b6 │ │ │ │ sub.w r2, r5, #123 @ 0x7b │ │ │ │ bics.w r2, r2, #2 │ │ │ │ - beq.w 3622e │ │ │ │ + beq.w 361b6 │ │ │ │ adds r2, r7, r3 │ │ │ │ adds r3, #1 │ │ │ │ str r3, [r7, #0] │ │ │ │ strb r5, [r2, #4] │ │ │ │ ldr r3, [r4, #12] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 35ebe │ │ │ │ + bne.n 35e46 │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - bne.n 35ec4 │ │ │ │ + bne.n 35e4c │ │ │ │ ldr r3, [r4, #8] │ │ │ │ adds r3, #1 │ │ │ │ str r3, [r4, #8] │ │ │ │ - b.n 35f40 │ │ │ │ + b.n 35ec8 │ │ │ │ ldr r3, [r4, #12] │ │ │ │ movs r6, #4 │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 35ebe │ │ │ │ + bne.n 35e46 │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - beq.w 36196 │ │ │ │ + beq.w 3611e │ │ │ │ adds r1, r0, #1 │ │ │ │ - beq.w 3616e │ │ │ │ + beq.w 360f6 │ │ │ │ ldr r6, [r4, #12] │ │ │ │ cmp r5, #10 │ │ │ │ - beq.w 3619e │ │ │ │ + beq.w 36126 │ │ │ │ movs r5, #0 │ │ │ │ - cbz r6, 35fc8 │ │ │ │ + cbz r6, 35f50 │ │ │ │ ldr r3, [r4, #16] │ │ │ │ str r5, [r4, #12] │ │ │ │ cmp r3, #10 │ │ │ │ it ne │ │ │ │ cmpne.w r3, #4294967295 @ 0xffffffff │ │ │ │ - beq.w 36172 │ │ │ │ + beq.w 360fa │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - beq.n 35eda │ │ │ │ + beq.n 35e62 │ │ │ │ ldr r6, [r4, #12] │ │ │ │ adds r0, #1 │ │ │ │ - bne.n 35fb6 │ │ │ │ - b.n 35eb6 │ │ │ │ + bne.n 35f3e │ │ │ │ + b.n 35e3e │ │ │ │ ldr r3, [r4, #12] │ │ │ │ - cbnz r3, 3601c │ │ │ │ + cbnz r3, 35fa4 │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - beq.n 36066 │ │ │ │ + beq.n 35fee │ │ │ │ adds r6, r0, #1 │ │ │ │ - beq.w 3616e │ │ │ │ + beq.w 360f6 │ │ │ │ cmp r5, #34 @ 0x22 │ │ │ │ - beq.n 360be │ │ │ │ + beq.n 36046 │ │ │ │ cmp r5, #92 @ 0x5c │ │ │ │ - beq.n 36084 │ │ │ │ + beq.n 3600c │ │ │ │ cmp r5, #10 │ │ │ │ it eq │ │ │ │ ldreq r2, [r4, #8] │ │ │ │ - beq.n 3606c │ │ │ │ - ldr r3, [pc, #792] @ (36320 ) │ │ │ │ + beq.n 35ff4 │ │ │ │ + ldr r3, [pc, #792] @ (362a8 ) │ │ │ │ uxtb r5, r5 │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #0] │ │ │ │ add.w r2, r8, r3 │ │ │ │ adds r3, #1 │ │ │ │ str.w r3, [r8] │ │ │ │ strb r5, [r2, #4] │ │ │ │ ldr r3, [r4, #12] │ │ │ │ - cbz r3, 36054 │ │ │ │ + cbz r3, 35fdc │ │ │ │ movs r6, #3 │ │ │ │ - b.n 35ebe │ │ │ │ + b.n 35e46 │ │ │ │ lsls r6, r3, #18 │ │ │ │ - bmi.w 36140 │ │ │ │ + bmi.w 360c8 │ │ │ │ lsls r0, r3, #20 │ │ │ │ - bpl.n 360e8 │ │ │ │ - ldr r2, [pc, #760] @ (36324 ) │ │ │ │ + bpl.n 36070 │ │ │ │ + ldr r2, [pc, #760] @ (362ac ) │ │ │ │ movs r6, #2 │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, #0] │ │ │ │ adds r1, r2, r3 │ │ │ │ adds r3, #1 │ │ │ │ str r3, [r2, #0] │ │ │ │ strb r5, [r1, #4] │ │ │ │ ldr r3, [r4, #12] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 35ebe │ │ │ │ + bne.w 35e46 │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - bne.w 35f3a │ │ │ │ - b.n 35f86 │ │ │ │ + bne.w 35ec2 │ │ │ │ + b.n 35f0e │ │ │ │ ldr r0, [r4, #4] │ │ │ │ movs r6, #3 │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - bne.w 35ec4 │ │ │ │ + bne.w 35e4c │ │ │ │ ldr r2, [r4, #8] │ │ │ │ adds r2, #1 │ │ │ │ str r2, [r4, #8] │ │ │ │ - ldr r3, [pc, #696] @ (36328 ) │ │ │ │ - ldr r0, [pc, #700] @ (3632c ) │ │ │ │ + ldr r3, [pc, #696] @ (362b0 ) │ │ │ │ + ldr r0, [pc, #700] @ (362b4 ) │ │ │ │ add r3, pc │ │ │ │ ldr r1, [r4, #0] │ │ │ │ add r0, pc │ │ │ │ - bl 128b8 │ │ │ │ + bl 13028 │ │ │ │ movs r2, #1 │ │ │ │ movs r3, #10 │ │ │ │ strd r2, r3, [r4, #12] │ │ │ │ - b.n 35ebc │ │ │ │ + b.n 35e44 │ │ │ │ ldr r3, [r4, #12] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 361a6 │ │ │ │ + beq.w 3612e │ │ │ │ ldr r5, [r4, #16] │ │ │ │ movs r3, #0 │ │ │ │ str r3, [r4, #12] │ │ │ │ cmp r5, #110 @ 0x6e │ │ │ │ - beq.w 36206 │ │ │ │ + beq.w 3618e │ │ │ │ cmp r5, #116 @ 0x74 │ │ │ │ - beq.w 361f6 │ │ │ │ + beq.w 3617e │ │ │ │ adds r3, r5, #1 │ │ │ │ - bne.w 361f2 │ │ │ │ - ldr r3, [pc, #648] @ (36330 ) │ │ │ │ + bne.w 3617a │ │ │ │ + ldr r3, [pc, #648] @ (362b8 ) │ │ │ │ movs r5, #255 @ 0xff │ │ │ │ - ldr r0, [pc, #648] @ (36334 ) │ │ │ │ + ldr r0, [pc, #648] @ (362bc ) │ │ │ │ add r3, pc │ │ │ │ ldr r2, [r4, #8] │ │ │ │ ldr r1, [r4, #0] │ │ │ │ add r0, pc │ │ │ │ - bl 128b8 │ │ │ │ - ldr r3, [pc, #640] @ (36338 ) │ │ │ │ + bl 13028 │ │ │ │ + ldr r3, [pc, #640] @ (362c0 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #0] │ │ │ │ - b.n 3600c │ │ │ │ - ldr r3, [pc, #636] @ (3633c ) │ │ │ │ + b.n 35f94 │ │ │ │ + ldr r3, [pc, #636] @ (362c4 ) │ │ │ │ movs r0, #4 │ │ │ │ movs r2, #0 │ │ │ │ add r3, pc │ │ │ │ ldr r1, [r3, #0] │ │ │ │ add r3, r1 │ │ │ │ strb r2, [r3, #4] │ │ │ │ - ldr r2, [pc, #624] @ (36340 ) │ │ │ │ - ldr r3, [pc, #568] @ (36308 ) │ │ │ │ + ldr r2, [pc, #624] @ (362c8 ) │ │ │ │ + ldr r3, [pc, #568] @ (36290 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #4] │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.w 362de │ │ │ │ + bne.w 36266 │ │ │ │ add sp, #8 │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, pc} │ │ │ │ sub.w r3, r5, #34 @ 0x22 │ │ │ │ cmp r3, #12 │ │ │ │ - bhi.n 361d6 │ │ │ │ - add r2, pc, #8 @ (adr r2, 360fc ) │ │ │ │ + bhi.n 3615e │ │ │ │ + add r2, pc, #8 @ (adr r2, 36084 ) │ │ │ │ ldr.w r3, [r2, r3, lsl #2] │ │ │ │ add r2, r3 │ │ │ │ bx r2 │ │ │ │ nop │ │ │ │ mcr2 15, 7, pc, cr1, cr15, {7} @ │ │ │ │ mrc2 15, 4, pc, cr3, cr15, {7} │ │ │ │ lsls r3, r3, #3 │ │ │ │ @@ -55544,286 +55535,286 @@ │ │ │ │ lsls r3, r3, #3 │ │ │ │ movs r0, r0 │ │ │ │ vminnm.f32 , , │ │ │ │ lsls r3, r3, #3 │ │ │ │ movs r0, r0 │ │ │ │ vminnm.f32 , , │ │ │ │ vminnm.f32 , , │ │ │ │ - ldr r3, [pc, #528] @ (36344 ) │ │ │ │ - ldr r0, [pc, #532] @ (36348 ) │ │ │ │ + ldr r3, [pc, #528] @ (362cc ) │ │ │ │ + ldr r0, [pc, #532] @ (362d0 ) │ │ │ │ ldr r2, [r4, #8] │ │ │ │ add r3, pc │ │ │ │ ldr r1, [r4, #0] │ │ │ │ add r0, pc │ │ │ │ - bl 128b8 │ │ │ │ + bl 13028 │ │ │ │ ldr r6, [r4, #12] │ │ │ │ cmp r6, #0 │ │ │ │ - bne.w 35ebc │ │ │ │ + bne.w 35e44 │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - bne.w 35ec4 │ │ │ │ + bne.w 35e4c │ │ │ │ ldr r3, [r4, #8] │ │ │ │ adds r3, #1 │ │ │ │ str r3, [r4, #8] │ │ │ │ - blx 3384 <__ctype_b_loc@plt> │ │ │ │ + blx 333c <__ctype_b_loc@plt> │ │ │ │ ldr r3, [r0, #0] │ │ │ │ ldrh r3, [r3, #20] │ │ │ │ lsls r5, r3, #21 │ │ │ │ - bpl.n 361ca │ │ │ │ + bpl.n 36152 │ │ │ │ movs r5, #10 │ │ │ │ - b.n 35f0c │ │ │ │ + b.n 35e94 │ │ │ │ movs r0, #1 │ │ │ │ - b.n 360cc │ │ │ │ + b.n 36054 │ │ │ │ movs r6, #0 │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - bne.w 35ec4 │ │ │ │ + bne.w 35e4c │ │ │ │ ldr r2, [r4, #8] │ │ │ │ adds r2, #1 │ │ │ │ str r2, [r4, #8] │ │ │ │ - b.n 35eca │ │ │ │ + b.n 35e52 │ │ │ │ ldr r2, [r4, #8] │ │ │ │ movs r5, #10 │ │ │ │ adds r2, #1 │ │ │ │ str r2, [r4, #8] │ │ │ │ - b.n 35efc │ │ │ │ + b.n 35e84 │ │ │ │ ldr r2, [r4, #8] │ │ │ │ ldr r6, [r4, #12] │ │ │ │ adds r2, #1 │ │ │ │ str r2, [r4, #8] │ │ │ │ cmp r6, #0 │ │ │ │ - bne.w 35ebc │ │ │ │ - b.n 35ee6 │ │ │ │ + bne.w 35e44 │ │ │ │ + b.n 35e6e │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - blx 343c │ │ │ │ + blx 33e4 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #10 │ │ │ │ str r0, [r4, #16] │ │ │ │ - bne.w 36092 │ │ │ │ + bne.w 3601a │ │ │ │ ldr r3, [r4, #8] │ │ │ │ adds r3, #1 │ │ │ │ str r3, [r4, #8] │ │ │ │ - ldr r2, [pc, #396] @ (3634c ) │ │ │ │ + ldr r2, [pc, #396] @ (362d4 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, #0] │ │ │ │ add r2, r3 │ │ │ │ adds r3, #1 │ │ │ │ strb r5, [r2, #4] │ │ │ │ - b.n 3600c │ │ │ │ + b.n 35f94 │ │ │ │ lsls r0, r3, #18 │ │ │ │ - bmi.n 36140 │ │ │ │ + bmi.n 360c8 │ │ │ │ movs r5, #10 │ │ │ │ lsls r1, r3, #20 │ │ │ │ - bmi.w 3602a │ │ │ │ - ldr r3, [pc, #376] @ (36350 ) │ │ │ │ + bmi.w 35fb2 │ │ │ │ + ldr r3, [pc, #376] @ (362d8 ) │ │ │ │ movs r2, #0 │ │ │ │ cmp r5, #59 @ 0x3b │ │ │ │ add r3, pc │ │ │ │ strb r5, [r3, #4] │ │ │ │ strb r2, [r3, #5] │ │ │ │ - beq.n 362be │ │ │ │ - ble.n 36272 │ │ │ │ + beq.n 36246 │ │ │ │ + ble.n 361fa │ │ │ │ cmp r5, #123 @ 0x7b │ │ │ │ - beq.n 362c2 │ │ │ │ + beq.n 3624a │ │ │ │ cmp r5, #125 @ 0x7d │ │ │ │ - bne.n 36130 │ │ │ │ + bne.n 360b8 │ │ │ │ movs r0, #6 │ │ │ │ - b.n 360cc │ │ │ │ + b.n 36054 │ │ │ │ uxtb r5, r5 │ │ │ │ - b.n 361bc │ │ │ │ - ldr r2, [pc, #348] @ (36354 ) │ │ │ │ + b.n 36144 │ │ │ │ + ldr r2, [pc, #348] @ (362dc ) │ │ │ │ movs r1, #9 │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, #0] │ │ │ │ add r2, r3 │ │ │ │ adds r3, #1 │ │ │ │ strb r1, [r2, #4] │ │ │ │ - b.n 3600c │ │ │ │ - ldr r2, [pc, #336] @ (36358 ) │ │ │ │ + b.n 35f94 │ │ │ │ + ldr r2, [pc, #336] @ (362e0 ) │ │ │ │ movs r1, #10 │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, #0] │ │ │ │ add r2, r3 │ │ │ │ adds r3, #1 │ │ │ │ strb r1, [r2, #4] │ │ │ │ - b.n 3600c │ │ │ │ + b.n 35f94 │ │ │ │ ldr r3, [r4, #8] │ │ │ │ add r3, r6 │ │ │ │ str r3, [r4, #8] │ │ │ │ - blx 3384 <__ctype_b_loc@plt> │ │ │ │ + blx 333c <__ctype_b_loc@plt> │ │ │ │ ldr r2, [r0, #0] │ │ │ │ ldr.w r3, [sl] │ │ │ │ ldrh r2, [r2, #20] │ │ │ │ lsls r2, r2, #18 │ │ │ │ - bpl.w 35f6a │ │ │ │ - ldr r7, [pc, #300] @ (3635c ) │ │ │ │ + bpl.w 35ef2 │ │ │ │ + ldr r7, [pc, #300] @ (362e4 ) │ │ │ │ mov.w r8, #0 │ │ │ │ add r7, pc │ │ │ │ add r3, r7 │ │ │ │ strb.w r8, [r3, #4] │ │ │ │ movs r3, #1 │ │ │ │ cmp r6, r3 │ │ │ │ str r5, [r4, #16] │ │ │ │ str r3, [r4, #12] │ │ │ │ - bne.n 36280 │ │ │ │ - ldr r4, [pc, #280] @ (36360 ) │ │ │ │ + bne.n 36208 │ │ │ │ + ldr r4, [pc, #280] @ (362e8 ) │ │ │ │ add r4, pc │ │ │ │ ldr r0, [r4, #0] │ │ │ │ cmp r0, #0 │ │ │ │ - beq.w 360cc │ │ │ │ + beq.w 36054 │ │ │ │ adds r5, r7, #4 │ │ │ │ - b.n 36260 │ │ │ │ + b.n 361e8 │ │ │ │ ldr.w r0, [r4, #16]! │ │ │ │ cmp r0, #0 │ │ │ │ - beq.w 360cc │ │ │ │ + beq.w 36054 │ │ │ │ mov r1, r5 │ │ │ │ - blx 3590 │ │ │ │ + blx 352c │ │ │ │ cmp r0, #0 │ │ │ │ - bne.n 36256 │ │ │ │ + bne.n 361de │ │ │ │ ldr r0, [r4, #8] │ │ │ │ str.w r4, [r7, #264] @ 0x108 │ │ │ │ - b.n 360cc │ │ │ │ + b.n 36054 │ │ │ │ cmp r5, #44 @ 0x2c │ │ │ │ - beq.n 362c6 │ │ │ │ + beq.n 3624e │ │ │ │ cmp r5, #58 @ 0x3a │ │ │ │ - bne.w 36130 │ │ │ │ + bne.w 360b8 │ │ │ │ movs r0, #8 │ │ │ │ - b.n 360cc │ │ │ │ + b.n 36054 │ │ │ │ adds r6, r7, #4 │ │ │ │ - blx 35c0 <__errno_location@plt> │ │ │ │ + blx 355c <__errno_location@plt> │ │ │ │ mov r1, sp │ │ │ │ str.w r8, [r0] │ │ │ │ mov r5, r0 │ │ │ │ mov r0, r6 │ │ │ │ - blx 3008 │ │ │ │ + blx 2fbc │ │ │ │ ldr r3, [sp, #0] │ │ │ │ vstr d0, [r7, #264] @ 0x108 │ │ │ │ cmp r3, r6 │ │ │ │ - beq.n 362a2 │ │ │ │ + beq.n 3622a │ │ │ │ ldrb r3, [r3, #0] │ │ │ │ - cbz r3, 362b4 │ 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adds r0, r3, r7 │ │ │ │ - movs r2, r0 │ │ │ │ - ldr r1, [sp, #640] @ 0x280 │ │ │ │ + subs r0, r2, r1 │ │ │ │ movs r2, r0 │ │ │ │ - ldr r1, [sp, #616] @ 0x268 │ │ │ │ + ldr r1, [sp, #512] @ 0x200 │ │ │ │ movs r2, r0 │ │ │ │ ldr r1, [sp, #488] @ 0x1e8 │ │ │ │ movs r2, r0 │ │ │ │ - ldr r1, [sp, #248] @ 0xf8 │ │ │ │ + ldr r1, [sp, #360] @ 0x168 │ │ │ │ + movs r2, r0 │ │ │ │ + ldr r1, [sp, #120] @ 0x78 │ │ │ │ movs r2, r0 │ │ │ │ - strh r2, [r0, r5] │ │ │ │ + strb r6, [r4, r5] │ │ │ │ movs r1, r0 │ │ │ │ - ldr r0, [sp, #856] @ 0x358 │ │ │ │ + ldr r0, [sp, #728] @ 0x2d8 │ │ │ │ movs r2, r0 │ │ │ │ - ldr r0, [sp, #592] @ 0x250 │ │ │ │ + ldr r0, [sp, #464] @ 0x1d0 │ │ │ │ movs r2, r0 │ │ │ │ - strh r0, [r2, r1] │ │ │ │ + strb r4, [r6, r1] │ │ │ │ movs r1, r0 │ │ │ │ - str r4, [r4, r4] │ │ │ │ + strh r0, [r1, r5] │ │ │ │ movs r1, r0 │ │ │ │ - asrs r0, r7, #31 │ │ │ │ + adds r0, r6, r1 │ │ │ │ movs r2, r0 │ │ │ │ - str r7, [sp, #696] @ 0x2b8 │ │ │ │ + str r7, [sp, #568] @ 0x238 │ │ │ │ movs r2, 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│ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #6 │ │ │ │ it ne │ │ │ │ cmpne r0, #1 │ │ │ │ - bne.n 36eca │ │ │ │ - b.n 369da │ │ │ │ + bne.n 36e52 │ │ │ │ + b.n 36962 │ │ │ │ mov r0, r4 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #1 │ │ │ │ it ne │ │ │ │ cmpne r0, #6 │ │ │ │ - beq.w 369da │ │ │ │ + beq.w 36962 │ │ │ │ mov r0, r4 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #1 │ │ │ │ it ne │ │ │ │ cmpne r0, #6 │ │ │ │ - bne.n 36eea │ │ │ │ - b.n 369da │ │ │ │ + bne.n 36e72 │ │ │ │ + b.n 36962 │ │ │ │ mov r0, r4 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #6 │ │ │ │ it ne │ │ │ │ cmpne r0, #1 │ │ │ │ - beq.w 369da │ │ │ │ + beq.w 36962 │ │ │ │ mov r0, r4 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #6 │ │ │ │ it ne │ │ │ │ cmpne r0, #1 │ │ │ │ - bne.n 36f0a │ │ │ │ - b.n 369da │ │ │ │ + bne.n 36e92 │ │ │ │ + b.n 36962 │ │ │ │ mov r0, r4 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #6 │ │ │ │ it ne │ │ │ │ cmpne r0, #1 │ │ │ │ - beq.w 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beq.w 36962 │ │ │ │ cmp r3, #10 │ │ │ │ - bne.n 37036 │ │ │ │ - b.n 369da │ │ │ │ + bne.n 36fbe │ │ │ │ + b.n 36962 │ │ │ │ nop.w │ │ │ │ ... │ │ │ │ add pc, r0 │ │ │ │ - ldr r2, [pc, #924] @ (373f8 ) │ │ │ │ + ldr r2, [pc, #924] @ (37380 ) │ │ │ │ ldrsb r0, [r3, r4] │ │ │ │ subs r7, #198 @ 0xc6 │ │ │ │ - ldr r6, [pc, #996] @ (37448 ) │ │ │ │ + ldr r6, [pc, #996] @ (373d0 ) │ │ │ │ ldrb r4, [r1, #11] │ │ │ │ str r4, [sp, #196] @ 0xc4 │ │ │ │ subs r7, #179 @ 0xb3 │ │ │ │ str r1, [sp, #416] @ 0x1a0 │ │ │ │ ldrb r5, [r5, #19] │ │ │ │ adds r5, #63 @ 0x3f │ │ │ │ ands r1, r3 │ │ │ │ cmp r0, #246 @ 0xf6 │ │ │ │ ldrh r4, [r3, #58] @ 0x3a │ │ │ │ asrs r2, r0, #23 │ │ │ │ eors r0, r0 │ │ │ │ - bvc.n 37090 │ │ │ │ + bvc.n 37018 │ │ │ │ strb r3, [r4, #2] │ │ │ │ pop {r0, r2, r3, r4} │ │ │ │ lsls r7, r6 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, #0 │ │ │ │ lsls r4, r5 │ │ │ │ - str r3, [sp, #376] @ 0x178 │ │ │ │ + str r3, [sp, #248] @ 0xf8 │ │ │ │ movs r2, r0 │ │ │ │ - str r3, [sp, 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movs r1, r0 │ │ │ │ - ldrh r6, [r4, #26] │ │ │ │ + ldrh r6, [r0, #26] │ │ │ │ movs r2, r0 │ │ │ │ - cmp ip, r1 │ │ │ │ + blx r6 │ │ │ │ movs r1, r0 │ │ │ │ - mvns r0, r7 │ │ │ │ + mov r4, r3 │ │ │ │ movs r1, r0 │ │ │ │ - add sl, ip │ │ │ │ + bx r0 │ │ │ │ movs r1, r0 │ │ │ │ - mvns r6, r2 │ │ │ │ + cmp sl, pc │ │ │ │ movs r1, r0 │ │ │ │ - cmp r6, ip │ │ │ │ + @ instruction: 0x478a │ │ │ │ movs r1, r0 │ │ │ │ push {r4, r5, r6, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4080] @ 0xff0 │ │ │ │ - ldr r3, [pc, #40] @ (3756c ) │ │ │ │ + ldr r3, [pc, #40] @ (374f4 ) │ │ │ │ add r3, pc │ │ │ │ ldr.w r4, [r3, #276] @ 0x114 │ │ │ │ - cbz r4, 37568 │ │ │ │ + cbz r4, 374f0 │ │ │ │ mov r5, r0 │ │ │ │ mov r6, r1 │ │ │ │ - b.n 37556 │ │ │ │ + b.n 374de │ │ │ │ ldr r4, [r4, #4] │ │ │ │ - cbz r4, 37568 │ │ │ │ + cbz r4, 374f0 │ │ │ │ ldr r3, [r4, #8] │ │ │ │ cmp r3, r5 │ │ │ │ - bne.n 37552 │ │ │ │ + bne.n 374da │ │ │ │ ldr r1, [r4, #12] │ │ │ │ mov r0, r6 │ │ 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37658 │ │ │ │ - ldr r1, [pc, #100] @ (376b4 ) │ │ │ │ + blx 352c │ │ │ │ + cbz r0, 375e0 │ │ │ │ + ldr r1, [pc, #100] @ (3763c ) │ │ │ │ mov r0, r7 │ │ │ │ add r1, pc │ │ │ │ - blx 3590 │ │ │ │ - cbnz r0, 37676 │ │ │ │ + blx 352c │ │ │ │ + cbnz r0, 375fe │ │ │ │ movs r1, #1 │ │ │ │ mov r0, r8 │ │ │ │ - bl 810c │ │ │ │ + bl 8074 │ │ │ │ mov r3, r0 │ │ │ │ str.w r3, [r4, #1368] @ 0x558 │ │ │ │ - cbz r3, 3768a │ │ │ │ + cbz r3, 37612 │ │ │ │ mov r0, r8 │ │ │ │ str r3, [r5, #20] │ │ │ │ - blx 2fd8 │ │ │ │ + blx 2f88 │ │ │ │ mov r0, r4 │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, pc} │ │ │ │ movs r1, #1 │ │ │ │ mov r0, r8 │ │ │ │ - bl 7c00 │ │ │ │ + bl 7b60 │ │ │ │ mov r3, r0 │ │ │ │ - b.n 37662 │ │ │ │ + b.n 375ea │ │ │ │ movs r4, #0 │ │ │ │ mov r0, r4 │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, pc} │ │ │ │ - ldr r2, [pc, #44] @ (376b8 ) │ │ │ │ + ldr r2, [pc, #44] @ (37640 ) │ │ │ │ movw r1, #1697 @ 0x6a1 │ │ │ │ - ldr r0, [pc, #40] @ (376bc ) │ │ │ │ + ldr r0, [pc, #40] @ (37644 ) │ │ │ │ ldr r3, [r5, #16] │ │ │ │ add r2, pc │ │ │ │ add r0, pc │ │ │ │ - bl 12824 │ │ │ │ - blx 2f44 │ │ │ │ - ldrh r0, [r6, #18] │ │ │ │ + bl 12f94 │ │ │ │ + blx 2ef4 │ │ │ │ + ldrh r0, [r2, #18] │ │ │ │ movs r2, r0 │ │ │ │ - ldrh r2, [r6, #16] │ │ │ │ + ldrh r2, [r2, #16] │ │ │ │ movs r2, r0 │ │ │ │ - ldrh r4, [r4, #16] │ │ │ │ + ldrh r4, [r0, #16] │ │ │ │ movs r2, r0 │ │ │ │ - ldr r7, [pc, #784] @ (379c0 ) │ │ │ │ + str r0, [r5, r7] │ │ │ │ movs r1, r0 │ │ │ │ - add ip, r5 │ │ │ │ + mov r8, sl │ │ │ │ movs r1, r0 │ │ │ │ - add r8, r5 │ │ │ │ + mov ip, r9 │ │ │ │ movs r1, r0 │ │ │ │ - add r4, sp │ │ │ │ + mov r8, r2 │ │ │ │ movs r1, r0 │ │ │ │ - rors r6, r6 │ │ │ │ + add r2, r3 │ │ │ │ movs r1, r0 │ │ │ │ push {r3, r4, r5, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4080] @ 0xff0 │ │ │ │ - ldr r3, [pc, #36] @ (376f4 ) │ │ │ │ + ldr r3, [pc, #36] @ (3767c ) │ │ │ │ add r3, pc │ │ │ │ ldr.w r4, [r3, #276] @ 0x114 │ │ │ │ - cbz r4, 376e8 │ │ │ │ + cbz r4, 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│ │ - ldr r3, [pc, #896] @ (37c28 ) │ │ │ │ + bne.n 37820 │ │ │ │ + ldr r3, [pc, #896] @ (37bb0 ) │ │ │ │ ldr r0, [r5, #4] │ │ │ │ add r3, pc │ │ │ │ str.w r7, [r3, #288] @ 0x120 │ │ │ │ - blx 2fd8 │ │ │ │ + blx 2f88 │ │ │ │ ldr r0, [r5, #0] │ │ │ │ - bl 13b48 │ │ │ │ + bl 13c20 │ │ │ │ mov r0, r5 │ │ │ │ - bl 13b48 │ │ │ │ - ldr r0, [pc, #872] @ (37c2c ) │ │ │ │ + bl 13c20 │ │ │ │ + ldr r0, [pc, #872] @ (37bb4 ) │ │ │ │ movs r4, #0 │ │ │ │ add r0, pc │ │ │ │ - bl 32688 │ │ │ │ + bl 32610 │ │ │ │ movw r1, #999 @ 0x3e7 │ │ │ │ mov r2, r0 │ │ │ │ mov r0, fp │ │ │ │ - bl 13d0c │ │ │ │ - ldr r3, [pc, #856] @ (37c30 ) │ │ │ │ + bl 13de4 │ │ │ │ + ldr r3, [pc, #856] @ (37bb8 ) │ │ │ │ mov r0, fp │ │ │ │ add r3, pc │ │ │ │ strd r4, r4, [r3, #280] @ 0x118 │ │ │ │ - bl 35e10 │ │ │ │ + bl 35d98 │ │ │ │ mov r5, r0 │ │ │ │ cmp r0, #0 │ │ │ │ - beq.w 37cea │ │ │ │ - ldr.w r9, [pc, #836] @ 37c34 │ │ │ │ + beq.w 37c72 │ │ │ │ + ldr.w r9, [pc, #836] @ 37bbc │ │ │ │ mov r8, r4 │ │ │ │ - ldr r6, [pc, #836] @ (37c38 ) │ │ │ │ + ldr r6, [pc, #836] @ (37bc0 ) │ │ │ │ movs r7, #48 @ 0x30 │ │ │ │ add r9, pc │ │ │ │ - vldr d8, [pc, #772] @ 37c00 │ │ │ │ + vldr d8, [pc, #772] @ 37b88 │ │ │ │ add r6, pc │ │ │ │ add r4, sp, #8 │ │ │ │ - b.n 379f2 │ │ │ │ + b.n 3797a │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #2 │ │ │ │ - bne.w 37c4c │ │ │ │ + bne.w 37bd4 │ │ │ │ vldr d7, [r9, #264] @ 0x108 │ │ │ │ vmov.f64 d6, #96 @ 0x3f000000 0.5 │ │ │ │ mov r0, r5 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ ite ge │ │ │ │ vaddge.f64 d7, d7, d6 │ │ │ │ @@ -57831,80 +57822,80 @@ │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r3, s15 │ │ │ │ adds r2, r3, #1 │ │ │ │ ittt ne │ │ │ │ strhne r3, [r4, #16] │ │ │ │ movne r2, #1 │ │ │ │ strhne r2, [r4, #18] │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #7 │ │ │ │ - bne.w 37b44 │ │ │ │ + bne.w 37acc │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #2 │ │ │ │ - bne.w 37b62 │ │ │ │ + bne.w 37aea │ │ │ │ vldr d7, [r6, #264] @ 0x108 │ │ │ │ mov r0, r5 │ │ │ │ vmul.f64 d7, d7, d8 │ │ │ │ vstr d7, [r4, #24] │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #7 │ │ │ │ - bne.w 37b80 │ │ │ │ + bne.w 37b08 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #2 │ │ │ │ - bne.w 37b9e │ │ │ │ + bne.w 37b26 │ │ │ │ ldrd r2, r3, [r6, #264] @ 0x108 │ │ │ │ mov r0, r5 │ │ │ │ strd r2, r3, [r4, #32] │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #7 │ │ │ │ - bne.w 37bbc │ │ │ │ + bne.w 37b44 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ sub.w r2, r0, #16 │ │ │ │ mov r3, r0 │ │ │ │ cmp r2, #1 │ │ │ │ - bhi.w 37bdc │ │ │ │ + bhi.w 37b64 │ │ │ │ sub.w r3, r3, #16 │ │ │ │ mov r0, r5 │ │ │ │ clz r3, r3 │ │ │ │ lsrs r3, r3, #5 │ │ │ │ str r3, [r4, #40] @ 0x28 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #9 │ │ │ │ - bne.w 37c6c │ │ │ │ - ldr r0, [pc, #644] @ (37c3c ) │ │ │ │ + bne.w 37bf4 │ │ │ │ + ldr r0, [pc, #644] @ (37bc4 ) │ │ │ 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│ │ @@ -57962,321 +57953,321 @@ │ │ │ │ strbne r0, [r4, #9] │ │ │ │ adds r1, r3, #1 │ │ │ │ ittt ne │ │ │ │ movne r2, #1 │ │ │ │ strbne r3, [r4, #0] │ │ │ │ strbne r2, [r4, #8] │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ cmp r0, #7 │ │ │ │ - beq.w 37902 │ │ │ │ + beq.w 3788a │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - bne.n 37ab0 │ │ │ │ - ldr r3, [pc, #384] @ (37c40 ) │ │ │ │ + bne.n 37a38 │ │ │ │ + ldr r3, [pc, #384] @ (37bc8 ) │ │ │ │ ldr r0, [r5, #4] │ │ │ │ add r3, pc │ │ │ │ str.w r8, [r3, #284] @ 0x11c │ │ │ │ - blx 2fd8 │ │ │ │ + blx 2f88 │ │ │ │ ldr r0, [r5, #0] │ │ │ │ - bl 13b48 │ │ │ │ + bl 13c20 │ │ │ │ mov r0, r5 │ │ │ │ - bl 13b48 │ │ │ │ - ldr r0, [pc, #360] @ (37c44 ) │ │ │ │ + bl 13c20 │ │ │ │ + ldr r0, [pc, #360] @ (37bcc ) │ │ │ │ add r0, pc │ │ │ │ - bl 14098 │ │ │ │ - ldr r2, [pc, #356] @ (37c48 ) │ │ │ │ - ldr r3, [pc, #304] @ (37c14 ) │ │ │ │ + bl 14170 │ │ │ │ + ldr r2, [pc, #356] @ (37bd0 ) │ │ │ │ + ldr r3, [pc, #304] @ (37b9c ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr.w r3, [sp, #1060] @ 0x424 │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.w 37d12 │ │ │ │ + bne.w 37c9a │ │ │ │ addw sp, sp, #1068 @ 0x42c │ │ │ │ vpop {d8} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - beq.w 378a6 │ │ │ │ + beq.w 3782e │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - bne.n 37b04 │ │ │ │ - b.n 378a6 │ │ │ │ + bne.n 37a8c │ │ │ │ + b.n 3782e │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - beq.w 378a6 │ │ │ │ + beq.w 3782e │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - bne.n 37b24 │ │ │ │ - b.n 378a6 │ │ │ │ + bne.n 37aac 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b.n 37a46 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - beq.n 37abe │ │ │ │ + beq.n 37a46 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - bne.n 37b9e │ │ │ │ - b.n 37abe │ │ │ │ + bne.n 37b26 │ │ │ │ + b.n 37a46 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - beq.w 37abe │ │ │ │ + beq.w 37a46 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - bne.n 37bbc │ │ │ │ - b.n 37abe │ │ │ │ + bne.n 37b44 │ │ │ │ + b.n 37a46 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - beq.w 37abe │ │ │ │ + beq.w 37a46 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - bne.n 37bdc │ │ │ │ - b.n 37abe │ │ │ │ + bne.n 37b64 │ │ │ │ + b.n 37a46 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0x36 │ │ │ │ movs r2, r0 │ │ │ │ - strh r0, [r7, #54] @ 0x36 │ │ │ │ + strh r0, [r3, #54] @ 0x36 │ │ │ │ movs r2, r0 │ │ │ │ - subs r6, #204 @ 0xcc │ │ │ │ + lsrs r0, r6 │ │ │ │ movs r1, r0 │ │ │ │ - strh r2, [r6, #40] @ 0x28 │ │ │ │ + strh r2, [r2, #40] @ 0x28 │ │ │ │ movs r2, r0 │ │ │ │ @ instruction: 0xea83ffff │ │ │ │ - lsls r0, r3, #20 │ │ │ │ + lsls r0, r2, #22 │ │ │ │ movs r2, r0 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - beq.w 37abe │ │ │ │ + beq.w 37a46 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - bne.n 37c4c │ │ │ │ - b.n 37abe │ │ │ │ + bne.n 37bd4 │ │ │ │ + b.n 37a46 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - beq.w 37abe │ │ │ │ + beq.w 37a46 │ │ │ │ mov r0, r5 │ │ │ │ - bl 35e70 │ │ │ │ + bl 35df8 │ │ │ │ bic.w r0, r0, #8 │ │ │ │ cmp r0, #1 │ │ │ │ - bne.n 37c6c │ │ │ │ - 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pc │ │ │ │ - blx 3348 │ │ │ │ - ldr r0, [pc, #60] @ (37d20 ) │ │ │ │ + blx 3300 │ │ │ │ + ldr r0, [pc, #60] @ (37ca8 ) │ │ │ │ add r0, pc │ │ │ │ - bl 128b8 │ │ │ │ - b.n 378c0 │ │ │ │ - ldr r3, [pc, #44] @ (37d18 ) │ │ │ │ + bl 13028 │ │ │ │ + b.n 37848 │ │ │ │ + ldr r3, [pc, #44] @ (37ca0 ) │ │ │ │ movs r2, #31 │ │ │ │ ldr r4, [sp, #4] │ │ │ │ movs r1, #1 │ │ │ │ - ldr r0, [pc, #48] @ (37d24 ) │ │ │ │ + ldr r0, [pc, #48] @ (37cac ) │ │ │ │ ldr r3, [r4, r3] │ │ │ │ add r0, pc │ │ │ │ ldr r3, [r3, #0] │ │ │ │ - blx 3348 │ │ │ │ - ldr r0, [pc, #40] @ (37d28 ) │ │ │ │ - add r0, pc │ │ │ │ - bl 128b8 │ │ │ │ - b.n 37ad8 │ │ │ │ - ldr r0, [pc, #32] @ (37d2c ) │ │ │ │ + blx 3300 │ │ │ │ + ldr r0, [pc, #40] @ (37cb0 ) │ │ │ │ add r0, pc │ │ │ │ - bl 128b8 │ │ │ │ - b.n 37756 │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + bl 13028 │ │ │ │ + b.n 37a60 │ │ │ │ + ldr r0, [pc, #32] @ (37cb4 ) │ │ │ │ + add r0, pc │ │ │ │ + bl 13028 │ │ │ │ + b.n 376de │ │ │ │ + blx 3370 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#112 @ 0x70 │ │ │ │ ldr r6, [r2, r3] │ │ │ │ str.w r9, [sp, #24] │ │ │ │ mov r9, r0 │ │ │ │ vldr d7, [sp, #16] │ │ │ │ mov r2, r7 │ │ │ │ @@ -59111,30 +59102,30 @@ │ │ │ │ add.w r1, r9, #4096 @ 0x1000 │ │ │ │ add.w ip, r6, #141312 @ 0x22800 │ │ │ │ vsub.f64 d7, d12, d7 │ │ │ │ vmls.f64 d8, d15, d7 │ │ │ │ vmls.f64 d9, d14, d7 │ │ │ │ vmls.f64 d11, d13, d7 │ │ │ │ vmov.f64 d10, d8 │ │ │ │ - b.n 386be │ │ │ │ - blt.n 386b2 │ │ │ │ + b.n 38646 │ │ │ │ + blt.n 3863a │ │ │ │ vcmpe.f64 d3, d12 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bls.n 38756 │ │ │ │ + bls.n 386de │ │ │ │ add.w r3, r3, #4416 @ 0x1140 │ │ │ │ adds r2, #72 @ 0x48 │ │ │ │ cmp r3, ip │ │ │ │ - beq.w 387d0 │ │ │ │ + beq.w 38758 │ │ │ │ ldr r0, [r3, #16] │ │ │ │ cmp r0, #0 │ │ │ │ - beq.n 386b2 │ │ │ │ + beq.n 3863a │ │ │ │ ldr.w r0, [r1, #300] @ 0x12c │ │ │ │ ldr r5, [r3, #0] │ │ │ │ cmp r0, r5 │ │ │ │ - beq.n 386b2 │ │ │ │ + beq.n 3863a │ │ │ │ vldr d1, [r3, #592] @ 0x250 │ │ │ │ vldr d7, [r3, #248] @ 0xf8 │ │ │ │ vldr d0, [r3, #584] @ 0x248 │ │ │ │ vldr d4, [r3, #240] @ 0xf0 │ │ │ │ vsub.f64 d7, d7, d1 │ │ │ │ vldr d8, [r3, #600] @ 0x258 │ │ │ │ vldr d2, [r3, #256] @ 0x100 │ │ │ │ @@ -59152,41 +59143,41 @@ │ │ │ │ vmla.f64 d2, d4, d4 │ │ │ │ vmla.f64 d5, d6, d8 │ │ │ │ vmla.f64 d2, d6, d6 │ │ │ │ vneg.f64 d5, d5 │ │ │ │ vdiv.f64 d3, d5, d2 │ │ │ │ vcmpe.f64 d3, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.n 386a6 │ │ │ │ + bpl.n 3862e │ │ │ │ vmul.f64 d5, d0, d0 │ │ │ │ vmla.f64 d5, d1, d1 │ │ │ │ vmla.f64 d5, d8, d8 │ │ │ │ vsqrt.f64 d3, d5 │ │ │ │ vmov.f64 d5, #8 @ 0x40400000 3.0 │ │ │ │ vcmpe.f64 d3, d5 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.n 386b2 │ │ │ │ - vldr d3, [pc, #500] @ 38948 │ │ │ │ + bpl.n 3863a │ │ │ │ + vldr d3, [pc, #500] @ 388d0 │ │ │ │ vmov.f64 d5, d10 │ │ │ │ vstr d4, [r2, #40] @ 0x28 │ │ │ │ vmla.f64 d5, d15, d3 │ │ │ │ vstr d7, [r2, #48] @ 0x30 │ │ │ │ vstr d6, [r2, #56] @ 0x38 │ │ │ │ vstr d5, [r2, #16] │ │ │ │ vmov.f64 d5, d9 │ │ │ │ vmla.f64 d5, d14, d3 │ │ │ │ vstr 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#200] @ 0xc8 │ │ │ │ vstr d3, [r4, #208] @ 0xd0 │ │ │ │ vstr d7, [r4, #216] @ 0xd8 │ │ │ │ ldr.w r0, [r5, #812] @ 0x32c │ │ │ │ add.w r0, r0, #848 @ 0x350 │ │ │ │ - bl b364 │ │ │ │ + bl b58c │ │ │ │ mov r2, r9 │ │ │ │ mov r0, sl │ │ │ │ add.w r1, r5, #344 @ 0x158 │ │ │ │ - bl b3c8 │ │ │ │ - vldr d1, [pc, #420] @ 38d10 │ │ │ │ + bl b66a │ │ │ │ + vldr d1, [pc, #420] @ 38c98 │ │ │ │ vldr d3, [sp, #32] │ │ │ │ add.w r9, r4, #264 @ 0x108 │ │ │ │ vldr d4, [sp, #40] @ 0x28 │ │ │ │ add.w sl, r4, #240 @ 0xf0 │ │ │ │ vldr d5, [sp, #48] @ 0x30 │ │ │ │ mov r1, r9 │ │ │ │ vldr d6, [r5, #240] @ 0xf0 │ │ │ │ @@ -59494,31 +59485,31 @@ │ │ │ │ vmla.f64 d6, d3, d1 │ │ │ │ vldr d2, [r5, #256] @ 0x100 │ │ │ │ vmla.f64 d7, d4, d1 │ │ │ │ vmla.f64 d2, d5, d1 │ │ │ │ vstr d6, [r4, #240] @ 0xf0 │ │ │ │ vstr d7, [r4, #248] @ 0xf8 │ │ │ │ vstr d2, [r4, #256] @ 0x100 │ │ │ │ - bl f010 │ │ │ │ + bl f780 │ │ │ │ mov lr, sl │ │ │ │ add.w ip, r4, #584 @ 0x248 │ │ │ │ ldmia.w lr!, {r0, r1, r2, r3} │ │ │ │ stmia.w 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33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 38c38 │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop.w │ │ │ │ ldr r5, [sp, #228] @ 0xe4 │ │ │ │ - add r2, pc, #328 @ (adr r2, 38e34 ) │ │ │ │ + add r2, pc, #328 @ (adr r2, 38dbc ) │ │ │ │ svc 70 @ 0x46 │ │ │ │ subs r7, #145 @ 0x91 │ │ │ │ @ instruction: 0xebd5f37b │ │ │ │ ldmia r6, {r0, r3, r5, r6, r7} │ │ │ │ subs r7, #170 @ 0xaa │ │ │ │ ldmia r5, {r1, r2, r4, r5} │ │ │ │ - ldr r6, [pc, #236] @ (38de8 ) │ │ │ │ + ldr r6, [pc, #236] @ (38d70 ) │ │ │ │ ldrh r1, [r2, #46] @ 0x2e │ │ │ │ lsls r2, r5 │ │ │ │ cmp r5, #24 │ │ │ │ strb r4, [r0, r1] │ │ │ │ movs r1, #251 @ 0xfb │ │ │ │ ands r1, r3 │ │ │ │ asrs r3, r7, #17 │ │ │ │ @@ -59624,48 +59615,48 @@ │ │ │ │ ldr r2, [r0, #40] @ 0x28 │ │ │ │ strh r2, [r3, #14] │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ eors r1, r1 │ │ │ │ - @ instruction: 0xf63a0001 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + @ instruction: 0xf6b20001 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - @ instruction: 0xf6360001 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + subw r0, lr, #2049 @ 0x801 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r1, #10 │ │ │ │ + lsls r0, r0, #10 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r2, #10 │ │ │ │ + lsls r4, r1, #10 │ │ │ │ movs r0, r0 │ │ │ │ lsls r1, r2, #10 │ │ │ │ movs r0, r0 │ │ │ │ @ instruction: 0xf94dffff │ │ │ │ - sbfx r0, r8, #0, #2 │ │ │ │ + ubfx r0, r0, #0, #2 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d15} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3936] @ 0xf60 │ │ │ │ mov r4, r1 │ │ │ │ add.w r1, r1, #4096 @ 0x1000 │ │ │ │ - vldr d12, [pc, #412] @ 38f00 │ │ │ │ + vldr d12, [pc, #412] @ 38e88 │ │ │ │ sub sp, #60 @ 0x3c │ │ │ │ - ldr r6, [pc, #412] @ (38f08 ) │ │ │ │ + ldr r6, [pc, #412] @ (38e90 ) │ │ │ │ vmov.f64 d2, #112 @ 0x3f800000 1.0 │ │ │ │ vldr s2, [r1, #284] @ 0x11c │ │ │ │ add.w r1, r4, #4352 @ 0x1100 │ │ │ │ vldr d4, [r4, #240] @ 0xf0 │ │ │ │ add r6, pc │ │ │ │ vldr d6, [r4, #584] @ 0x248 │ │ │ │ vcvt.f64.s32 d1, s2 │ │ │ │ - ldr r5, [pc, #388] @ (38f0c ) │ │ │ │ + ldr r5, [pc, #388] @ (38e94 ) │ │ │ │ vldr d5, [r4, #248] @ 0xf8 │ │ │ │ vsub.f64 d6, d4, d6 │ │ │ │ vldr d7, [r4, #592] @ 0x250 │ │ │ │ vldr d3, [r4, #256] @ 0x100 │ │ │ │ vdiv.f64 d4, d1, d12 │ │ │ │ ldr r5, [r6, r5] │ │ │ │ vldr d1, [r1, #16] │ │ │ │ @@ -59677,57 +59668,57 @@ │ │ │ │ add.w r5, r4, #4384 @ 0x1120 │ │ │ │ vsub.f64 d3, d3, d5 │ │ │ │ vldr d5, [r5] │ │ │ │ vadd.f64 d4, d4, d1 │ │ │ │ vdiv.f64 d11, d4, d5 │ │ │ │ vcmpe.f64 d11, d2 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bhi.w 38eda │ │ │ │ + bhi.w 38e62 │ │ │ │ vneg.f64 d14, d6 │ │ │ │ vneg.f64 d15, d7 │ │ │ │ vneg.f64 d13, d3 │ │ │ │ mov r7, r2 │ │ │ │ add r6, sp, #24 │ │ │ │ mov r8, r4 │ │ │ │ str r0, [sp, #20] │ │ │ │ str r3, [sp, #8] │ │ │ │ vmul.f64 d8, d11, d13 │ │ │ │ vldr d7, [r8, #280] @ 0x118 │ │ │ │ vadd.f64 d7, d8, d7 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.n 38eb8 │ │ │ │ + bmi.n 38e40 │ │ │ │ ldr.w r3, [r8, #812] @ 0x32c │ │ │ │ ldr.w r3, [r3, #1368] @ 0x558 │ │ │ │ ldrd r2, r3, [r3, #112] @ 0x70 │ │ │ │ cmp r2, #0 │ │ │ │ - ble.n 38eb8 │ │ │ │ + ble.n 38e40 │ │ │ │ sub.w sl, r3, #4 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ vmul.f64 d10, d14, d11 │ │ │ │ vmul.f64 d9, d15, d11 │ │ │ │ mov.w r9, #0 │ │ │ │ add.w r4, r3, #88 @ 0x58 │ │ │ │ str r2, [sp, #4] │ │ │ │ strd r8, r5, [sp, #12] │ │ │ │ ldr.w r0, [sl, #4]! │ │ │ │ - bl 9970 │ │ │ │ + bl 9838 │ │ │ │ ldrsh.w r2, [r0, #2] │ │ │ │ ldr r5, [r0, #32] │ │ │ │ mov fp, r0 │ │ │ │ cmp r2, #0 │ │ │ │ itt gt │ │ │ │ strgt.w r9, [sp] │ │ │ │ movgt.w r8, #0 │ │ │ │ - ble.n 38e9a │ │ │ │ + ble.n 38e22 │ │ │ │ mov r0, r5 │ │ │ │ mov r2, r6 │ │ │ │ mov r1, r7 │ │ │ │ add.w r8, r8, #1 │ │ │ │ - bl b264 │ │ │ │ + bl b394 │ │ │ │ vldr d5, [sp, #24] │ │ │ │ vldr d6, [sp, #32] │ │ │ │ mov lr, r6 │ │ │ │ vldr d7, [sp, #40] @ 0x28 │ │ │ │ mov ip, r5 │ │ │ │ vadd.f64 d5, d5, d10 │ │ │ │ ldrsh.w r9, [fp, #2] │ │ │ │ @@ -59738,98 +59729,98 @@ │ │ │ │ vstr d5, [sp, #24] │ │ │ │ vstr d6, [sp, #32] │ │ │ │ ldmia.w lr!, {r0, r1, r2, r3} │ │ │ │ vstr d7, [sp, #40] @ 0x28 │ │ │ │ stmia.w ip!, {r0, r1, r2, r3} │ │ │ │ ldmia.w lr, {r0, r1} │ │ │ │ stmia.w ip, {r0, r1} │ │ │ │ - bgt.n 38e46 │ │ │ │ + bgt.n 38dce │ │ │ │ ldr.w r9, [sp] │ │ │ │ mov r1, r4 │ │ │ │ mov r0, fp │ │ │ │ - bl 997c │ │ │ │ + bl 9844 │ │ │ │ ldr r0, [sp, #8] │ │ │ │ mov r1, fp │ │ │ │ add.w r9, r9, #1 │ │ │ │ - bl 9404 │ │ │ │ + bl 92d4 │ │ │ │ ldr r3, [sp, #4] │ │ │ │ cmp r3, r9 │ │ │ │ - bne.n 38e28 │ │ │ │ + bne.n 38db0 │ │ │ │ ldrd r8, r5, [sp, #12] │ │ │ │ vmov.f64 d4, #36 @ 0x41200000 10.0 │ │ │ │ vldr d7, [r5] │ │ │ │ vmov.f64 d6, #112 @ 0x3f800000 1.0 │ │ │ │ vmul.f64 d7, d7, d12 │ │ │ │ vdiv.f64 d5, d4, d7 │ │ │ │ vadd.f64 d11, d11, d5 │ │ │ │ vcmpe.f64 d11, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bls.n 38de6 │ │ │ │ - ldr r2, [pc, #52] @ (38f10 ) │ │ │ │ - ldr r3, [pc, #44] @ (38f0c ) │ │ │ │ + bls.n 38d6e │ │ │ │ + ldr r2, [pc, #52] @ (38e98 ) │ │ │ │ + ldr r3, [pc, #44] @ (38e94 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #52] @ 0x34 │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.n 38efa │ │ │ │ + bne.n 38e82 │ │ │ │ movs r0, #0 │ │ │ │ add sp, #60 @ 0x3c │ │ │ │ vpop {d8-d15} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ eors r1, r1 │ │ │ │ - @ instruction: 0xf2820001 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + @ instruction: 0xf2fa0001 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - adds.w r0, lr, #1 │ │ │ │ + @ instruction: 0xf1960001 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4064] @ 0xfe0 │ │ │ │ - ldr.w ip, [pc, #260] @ 39030 │ │ │ │ + ldr.w ip, [pc, #260] @ 38fb8 │ │ │ │ vmov.f64 d6, #36 @ 0x41200000 10.0 │ │ │ │ - ldr r3, [pc, #256] @ (39034 ) │ │ │ │ + ldr r3, [pc, #256] @ (38fbc ) │ │ │ │ add ip, pc │ │ │ │ vldr d5, [r0, #56] @ 0x38 │ │ │ │ ldr.w r3, [ip, r3] │ │ │ │ vldr d7, [r3] │ │ │ │ vsub.f64 d7, d7, d5 │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bgt.n 3900c │ │ │ │ + bgt.n 38f94 │ │ │ │ vldr d7, [r0, #280] @ 0x118 │ │ │ │ mov r4, r0 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.n 38f6a │ │ │ │ - ldr r0, [pc, #216] @ (39038 ) │ │ │ │ + bpl.n 38ef2 │ │ │ │ + ldr r0, [pc, #216] @ (38fc0 ) │ │ │ │ add r0, pc │ │ │ │ vpop {d8} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, pc} │ │ │ │ add.w r5, r0, #240 @ 0xf0 │ │ │ │ vldr d3, [r0, #216] @ 0xd8 │ │ │ │ vldr d1, [r0, #208] @ 0xd0 │ │ │ │ add.w r6, r0, #264 @ 0x108 │ │ │ │ vldr d0, [r0, #200] @ 0xc8 │ │ │ │ add.w lr, r0, #584 @ 0x248 │ │ │ │ ldmia r5!, {r0, r1, r2, r3} │ │ │ │ stmia.w lr!, {r0, r1, r2, r3} │ │ │ │ - ldr.w r8, [pc, #176] @ 3903c │ │ │ │ - ldr r7, [pc, #176] @ (39040 ) │ │ │ │ - vldr d5, [pc, #144] @ 39020 │ │ │ │ + ldr.w r8, [pc, #176] @ 38fc4 │ │ │ │ + ldr r7, [pc, #176] @ (38fc8 ) │ │ │ │ + vldr d5, [pc, #144] @ 38fa8 │ │ │ │ ldmia.w r5, {r0, r1} │ │ │ │ stmia.w lr, {r0, r1} │ │ │ │ - vldr d8, [pc, #140] @ 39028 │ │ │ │ + vldr d8, [pc, #140] @ 38fb0 │ │ │ │ mov r0, r6 │ │ │ │ ldr.w r8, [ip, r8] │ │ │ │ ldr.w r3, [ip, r7] │ │ │ │ vldr d4, [r8] │ │ │ │ vldr d6, [r3] │ │ │ │ vmul.f64 d1, d4, d1 │ │ │ │ vmul.f64 d0, d4, d0 │ │ │ │ @@ -59840,94 +59831,94 @@ │ │ │ │ vmul.f64 d4, d1, d1 │ │ │ │ vmla.f64 d4, d0, d0 │ │ │ │ vmls.f64 d7, d6, d5 │ │ │ │ vsqrt.f64 d2, d4 │ │ │ │ vstr d7, [r4, #280] @ 0x118 │ │ │ │ vdiv.f64 d1, d1, d2 │ │ │ │ vdiv.f64 d0, d0, d2 │ │ │ │ - bl e2f8 │ │ │ │ + bl ea68 │ │ │ │ add.w r1, r4, #240 @ 0xf0 │ │ │ │ mov r0, r6 │ │ │ │ - bl f320 │ │ │ │ + bl fa90 │ │ │ │ vldr d6, [r8] │ │ │ │ vldr d7, [r4, #216] @ 0xd8 │ │ │ │ ldr r3, [r4, #16] │ │ │ │ vmla.f64 d7, d6, d8 │ │ │ │ cmp r3, #3 │ │ │ │ vstr d7, [r4, #216] @ 0xd8 │ │ │ │ - beq.n 39018 │ │ │ │ + beq.n 38fa0 │ │ │ │ movs r0, #0 │ │ │ │ - b.n 38f62 │ │ │ │ + b.n 38eea │ │ │ │ vpop {d8} │ │ │ │ - ldr r0, [pc, #48] @ (39044 ) │ │ │ │ + ldr r0, [pc, #48] @ (38fcc ) │ │ │ │ add r0, pc │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, pc} │ │ │ │ mov r0, r4 │ │ │ │ - bl 385e4 │ │ │ │ - b.n 39008 │ │ │ │ + bl 3856c │ │ │ │ + b.n 38f90 │ │ │ │ subs r0, r6, r1 │ │ │ │ ldr r2, [r0, #40] @ 0x28 │ │ │ │ strh r2, [r3, #14] │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ cmp r0, #246 @ 0xf6 │ │ │ │ ldrh r4, [r3, #58] @ 0x3a │ │ │ │ asrs r2, r0, #23 │ │ │ │ eors r0, r0 │ │ │ │ - @ instruction: 0xf0ca0001 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + adc.w r0, r2, #1 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - adds r1, #148 @ 0x94 │ │ │ │ + adds r3, #184 @ 0xb8 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r1, #10 │ │ │ │ + lsls r4, r0, #10 │ │ │ │ movs r0, r0 │ │ │ │ - adds r0, #206 @ 0xce │ │ │ │ + adds r2, #242 @ 0xf2 │ │ │ │ movs r1, r0 │ │ │ │ push {r3, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4088] @ 0xff8 │ │ │ │ ldr.w r2, [r0, #3992] @ 0xf98 │ │ │ │ ldr.w r1, [r0, #3984] @ 0xf90 │ │ │ │ orr.w r2, r2, #1 │ │ │ │ str.w r2, [r0, #3992] @ 0xf98 │ │ │ │ cmp r1, #0 │ │ │ │ - ble.n 39072 │ │ │ │ + ble.n 38ffa │ │ │ │ movs r2, #1 │ │ │ │ movs r1, #8 │ │ │ │ - bl 449a8 │ │ │ │ + bl 44930 │ │ │ │ movs r0, #0 │ │ │ │ pop {r3, pc} │ │ │ │ nop │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d9} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3648] @ 0xe40 │ │ │ │ - ldr r2, [pc, #912] @ (39420 ) │ │ │ │ + ldr r2, [pc, #912] @ (393a8 ) │ │ │ │ sub sp, #396 @ 0x18c │ │ │ │ - ldr r3, [pc, #912] @ (39424 ) │ │ │ │ + ldr r3, [pc, #912] @ (393ac ) │ │ │ │ mov r5, r0 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#16368 @ 0x3ff0 │ │ │ │ strd sl, fp, [r0, #16] │ │ │ │ - bl b3c8 │ │ │ │ - vldr d7, [pc, #720] @ 393e8 │ │ │ │ + bl b66a │ │ │ │ + vldr d7, [pc, #720] @ 39370 │ │ │ │ vldr d1, [sp, #104] @ 0x68 │ │ │ │ mov r0, r6 │ │ │ │ vldr d2, [sp, #112] @ 0x70 │ │ │ │ vmul.f64 d7, d8, d7 │ │ │ │ vldr d3, [sp, #120] @ 0x78 │ │ │ │ vldr d4, [r4] │ │ │ │ vldr d5, [r4, #8] │ │ │ │ @@ -59958,36 +59949,36 @@ │ │ │ │ vmul.f64 d7, d7, d8 │ │ │ │ vmla.f64 d5, d7, d2 │ │ │ │ vmla.f64 d6, d7, d3 │ │ │ │ vmla.f64 d4, d7, d1 │ │ │ │ vstr d5, [r4, #8] │ │ │ │ vstr d6, [r4, #16] │ │ │ │ vstr d4, [r4] │ │ │ │ - bl acb0 │ │ │ │ - ldr r3, [pc, #724] @ (3942c ) │ │ │ │ + bl ac98 │ │ │ │ + ldr r3, [pc, #724] @ (393b4 ) │ │ │ │ movs r2, #152 @ 0x98 │ │ │ │ add r3, pc │ │ │ │ mla r3, r2, r9, r3 │ │ │ │ vldr s14, [r3, #132] @ 0x84 │ │ │ │ vldr d5, [r3, #136] @ 0x88 │ │ │ │ vldr d6, [r3, #144] @ 0x90 │ │ │ │ vcvt.f64.s32 d7, s14 │ │ │ │ vdiv.f64 d0, d5, d7 │ │ │ │ vdiv.f64 d9, d6, d7 │ │ │ │ vcmp.f64 d0, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bne.w 393ba │ │ │ │ + bne.w 39342 │ │ │ │ vcmp.f64 d9, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bne.w 393ac │ │ │ │ + bne.w 39334 │ │ │ │ mov r0, r4 │ │ │ │ add r4, sp, #56 @ 0x38 │ │ │ │ mov r1, r6 │ │ │ │ mov r2, r4 │ │ │ │ - bl b264 │ │ │ │ + bl b394 │ │ │ │ ldr.w sl, [r7, #36] @ 0x24 │ │ │ │ vldr d7, [sp, #64] @ 0x40 │ │ │ │ vldr d5, [sp, #72] @ 0x48 │ │ │ │ vldr d4, [sp, #56] @ 0x38 │ │ │ │ vldr d6, [sl, #64] @ 0x40 │ │ │ │ vldr d3, [sl, #56] @ 0x38 │ │ │ │ ldrsh.w r1, [sl, #32] │ │ │ │ @@ -60005,24 +59996,24 @@ │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r6, s13 │ │ │ │ vmov r4, s15 │ │ │ │ add r6, r1 │ │ │ │ add r4, r2 │ │ │ │ mov.w r6, r6, asr #2 │ │ │ │ mov.w r4, r4, asr #2 │ │ │ │ - blt.n 39204 │ │ │ │ + blt.n 3918c │ │ │ │ vldr d7, [r5, #832] @ 0x340 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vstr s15, [sp, #20] │ │ │ │ vldr d1, [r7, #416] @ 0x1a0 │ │ │ │ uxth.w ip, r6 │ │ │ │ - vldr d7, [pc, #480] @ 393f0 │ │ │ │ + vldr d7, [pc, #480] @ 39378 │ │ │ │ uxth r1, r4 │ │ │ │ - vldr d6, [pc, #484] @ 393f8 │ │ │ │ - ldr r0, [pc, #536] @ (39430 ) │ │ │ │ + vldr d6, [pc, #484] @ 39380 │ │ │ │ + ldr r0, [pc, #536] @ (393b8 ) │ │ │ │ vmul.f64 d7, d1, d7 │ │ │ │ strd sl, r6, [sp, #24] │ │ │ │ add r0, pc │ │ │ │ vmul.f64 d1, d1, d6 │ │ │ │ add.w lr, r0, #192 @ 0xc0 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r9, s15 │ │ │ │ @@ -60068,35 +60059,35 @@ │ │ │ │ str.w r6, [sl, #8]! │ │ │ │ add r2, ip │ │ │ │ bfi r3, r2, #0, #16 │ │ │ │ vmov r2, s13 │ │ │ │ add r2, r1 │ │ │ │ bfi r3, r2, #16, #16 │ │ │ │ str.w r3, [sl, #4] │ │ │ │ - bne.n 3925c │ │ │ │ - ldr r3, [pc, #356] @ (39434 ) │ │ │ │ + bne.n 391e4 │ │ │ │ + ldr r3, [pc, #356] @ (393bc ) │ │ │ │ mov r1, r5 │ │ │ │ ldrd sl, r6, [sp, #24] │ │ │ │ mov.w ip, #23040 @ 0x5a00 │ │ │ │ mov r2, fp │ │ │ │ ldr.w r5, [r8, r3] │ │ │ │ movs r3, #0 │ │ │ │ ldr.w r0, [sl, #4] │ │ │ │ str.w r9, [sp] │ │ │ │ strd r3, ip, [sp, #4] │ │ │ │ ldrh r3, [r5, #0] │ │ │ │ str r3, [sp, #12] │ │ │ │ mov r3, r9 │ │ │ │ - bl 6044 │ │ │ │ + bl 5fdc │ │ │ │ ldr r1, [sp, #20] │ │ │ │ adds r3, r1, #1 │ │ │ │ - beq.n 3936c │ │ │ │ + beq.n 392f4 │ │ │ │ vldr d7, [r7, #416] @ 0x1a0 │ │ │ │ movw r3, #12000 @ 0x2ee0 │ │ │ │ - vldr d6, [pc, #248] @ 39400 │ │ │ │ + vldr d6, [pc, #248] @ 39388 │ │ │ │ cmp r1, r3 │ │ │ │ it ge │ │ │ │ movge r1, r3 │ │ │ │ mov.w r2, #42496 @ 0xa600 │ │ │ │ movt r2, #65535 @ 0xffff │ │ │ │ mov r3, r1 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ @@ -60123,61 +60114,61 @@ │ │ │ │ negs r1, r1 │ │ │ │ ldrh r2, [r5, #0] │ │ │ │ str r2, [sp, #12] │ │ │ │ mov.w r2, #5760 @ 0x1680 │ │ │ │ str r2, [sp, #4] │ │ │ │ adds r2, r4, r1 │ │ │ │ add r1, r6 │ │ │ │ - bl 6044 │ │ │ │ + bl 5fdc │ │ │ │ ldrh r3, [r5, #0] │ │ │ │ movs r2, #12 │ │ │ │ ldr r0, [r7, #36] @ 0x24 │ │ │ │ add r1, sp, #256 @ 0x100 │ │ │ │ - bl 9e84 │ │ │ │ - ldr r3, [pc, #188] @ (39438 ) │ │ │ │ - ldr r2, [pc, #192] @ (3943c ) │ │ │ │ + bl 9d4c │ │ │ │ + ldr r3, [pc, #188] @ (393c0 ) │ │ │ │ + ldr r2, [pc, #192] @ (393c4 ) │ │ │ │ add r3, pc │ │ │ │ add r2, pc │ │ │ │ strh r6, [r3, #0] │ │ │ │ strh r4, [r3, #2] │ │ │ │ - ldr r3, [pc, #156] @ (39424 ) │ │ │ │ + ldr r3, [pc, #156] @ (393ac ) │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #388] @ 0x184 │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.n 393c8 │ │ │ │ + bne.n 39350 │ │ │ │ add sp, #396 @ 0x18c │ │ │ │ vpop {d8-d9} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ - vldr d7, [pc, #104] @ 39408 │ │ │ │ - vldr d6, [pc, #108] @ 39410 │ │ │ │ - vldr d8, [pc, #112] @ 39418 │ │ │ │ - b.n 390d6 │ │ │ │ + vldr d7, [pc, #104] @ 39390 │ │ │ │ + vldr d6, [pc, #108] @ 39398 │ │ │ │ + vldr d8, [pc, #112] @ 393a0 │ │ │ │ + b.n 3905e │ │ │ │ vnmul.f64 d0, d9, d8 │ │ │ │ movs r1, #3 │ │ │ │ mov r0, r6 │ │ │ │ - bl af7c │ │ │ │ - b.n 39190 │ │ │ │ + bl afae │ │ │ │ + b.n 39118 │ │ │ │ vnmul.f64 d0, d0, d8 │ │ │ │ movs r1, #2 │ │ │ │ mov r0, r6 │ │ │ │ - bl af7c │ │ │ │ - b.n 39184 │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + bl afae │ │ │ │ + b.n 3910c │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop.w │ │ │ │ ldmia r5, {r1, r2, r4, r5} │ │ │ │ - ldr r6, [pc, #236] @ (394c0 ) │ │ │ │ + ldr r6, [pc, #236] @ (39448 ) │ │ │ │ ldrh r1, [r2, #46] @ 0x2e │ │ │ │ lsls r2, r5 │ │ │ │ - b.n 39016 │ │ │ │ + b.n 38f9e │ │ │ │ ldc 4, cr15, [r2, #-788] @ 0xfffffcec │ │ │ │ subs r7, #239 @ 0xef │ │ │ │ ldmia r1!, {r0, r2, r3} │ │ │ │ - ldr r0, [pc, #956] @ (397a0 ) │ │ │ │ + ldr r0, [pc, #956] @ (39728 ) │ │ │ │ ldmia r3!, {r0, r1, r2, r6, r7} │ │ │ │ subs r7, #170 @ 0xaa │ │ │ │ cmp r0, #246 @ 0xf6 │ │ │ │ ldrh r4, [r3, #58] @ 0x3a │ │ │ │ asrs r2, r0, #23 │ │ │ │ ands r0, r6 │ │ │ │ movs r0, r0 │ │ │ │ @@ -60199,41 +60190,41 @@ │ │ │ │ ldmia r0, {r0, r1, r4, r5, r6, r7} │ │ │ │ ldmia r5, {r1, r4, r5, r6, r7} │ │ │ │ strh r5, [r4, #8] │ │ │ │ lsls r3, r4 │ │ │ │ stc 6, cr9, [r3, #312]! @ 0x138 │ │ │ │ ldrh r6, [r6, #10] │ │ │ │ subs r7, #231 @ 0xe7 │ │ │ │ - vhadd.s32 d16, d8, d1 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + vaddl.s32 q8, d0, d1 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - vhadd.s16 d16, d12, d1 │ │ │ │ - strb r2, [r6, #21] │ │ │ │ + vaddl.s16 q8, d4, d1 │ │ │ │ + strb r2, [r2, #21] │ │ │ │ movs r2, r0 │ │ │ │ - bcc.n 394bc │ │ │ │ + bcs.n 39334 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r4, r4, #11 │ │ │ │ + lsls r4, r3, #11 │ │ │ │ movs r0, r0 │ │ │ │ - strb r0, [r1, #13] │ │ │ │ + strb r0, [r5, #12] │ │ │ │ movs r2, r0 │ │ │ │ - ldcl 0, cr0, [lr], #-4 │ │ │ │ + ldcl 0, cr0, [r6], #4 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4016] @ 0xfb0 │ │ │ │ mov r4, r0 │ │ │ │ - ldr r1, [pc, #508] @ (39650 ) │ │ │ │ - ldr r5, [pc, #508] @ (39654 ) │ │ │ │ + ldr r1, [pc, #508] @ (395d8 ) │ │ │ │ + ldr r5, [pc, #508] @ (395dc ) │ │ │ │ movs r0, #152 @ 0x98 │ │ │ │ add r1, pc │ │ │ │ - ldr r3, [pc, #508] @ (39658 ) │ │ │ │ + ldr r3, [pc, #508] @ (395e0 ) │ │ │ │ ldr r7, [r4, #0] │ │ │ │ add r5, pc │ │ │ │ sub sp, #44 @ 0x2c │ │ │ │ - ldr r6, [pc, #504] @ (3965c ) │ │ │ │ + ldr r6, [pc, #504] @ (395e4 ) │ │ │ │ ldr r3, [r5, r3] │ │ │ │ mov r5, r2 │ │ │ │ mla r0, r0, r7, r1 │ │ │ │ add r6, pc │ │ │ │ ldr r3, [r3, #0] │ │ │ │ str r3, [sp, #36] @ 0x24 │ │ │ │ mov.w r3, #0 │ │ │ │ @@ -60241,92 +60232,92 @@ │ │ │ │ ldr.w r2, [r0, #132] @ 0x84 │ │ │ │ adds r3, #1 │ │ │ │ cmp r3, #8 │ │ │ │ it ge │ │ │ │ movge r3, #0 │ │ │ │ cmp r2, #8 │ │ │ │ str.w r3, [r0, #128] @ 0x80 │ │ │ │ - beq.w 39606 │ │ │ │ + beq.w 3958e │ │ │ │ vldr d7, [r0, #144] @ 0x90 │ │ │ │ adds r2, #1 │ │ │ │ str.w r2, [r0, #132] @ 0x84 │ │ │ │ - ldr r2, [pc, #452] @ (39660 ) │ │ │ │ + ldr r2, [pc, #452] @ (395e8 ) │ │ │ │ movs r1, #152 @ 0x98 │ │ │ │ vldr d4, [r4, #504] @ 0x1f8 │ │ │ │ add r2, pc │ │ │ │ vldr d5, [r4, #512] @ 0x200 │ │ │ │ mla r1, r1, r7, r2 │ │ │ │ vadd.f64 d7, d5, d7 │ │ │ │ vldr d6, [r1, #136] @ 0x88 │ │ │ │ vstr d7, [r1, #144] @ 0x90 │ │ │ │ vadd.f64 d6, d6, d4 │ │ │ │ vstr d6, [r1, #136] @ 0x88 │ │ │ │ movs r1, #19 │ │ │ │ mla r3, r1, r7, r3 │ │ │ │ - ldr r1, [pc, #412] @ (39664 ) │ │ │ │ + ldr r1, [pc, #412] @ (395ec ) │ │ │ │ ldr.w r7, [r4, #3932] @ 0xf5c │ │ │ │ add r1, pc │ │ │ │ add.w r0, r2, r3, lsl #3 │ │ │ │ ldrb r3, [r1, #4] │ │ │ │ vstr d4, [r0] │ │ │ │ vstr d5, [r0, #64] @ 0x40 │ │ │ │ ldr r0, [r1, #0] │ │ │ │ str r0, [r7, #0] │ │ │ │ movs r0, #1 │ │ │ │ strb r3, [r7, #4] │ │ │ │ ldr.w r7, [r4, #3984] @ 0xf90 │ │ │ │ - bl 468cc │ │ │ │ - ldr r1, [pc, #376] @ (39668 ) │ │ │ │ + bl 46854 │ │ │ │ + ldr r1, [pc, #376] @ (395f0 ) │ │ │ │ mov r3, r0 │ │ │ │ mov r2, r7 │ │ │ │ add r7, sp, #20 │ │ │ │ add r1, pc │ │ │ │ mov r0, r7 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ ldr.w r0, [r4, #3936] @ 0xf60 │ │ │ │ mov r1, r7 │ │ │ │ - blx 32a4 │ │ │ │ + blx 325c │ │ │ │ ldr.w r3, [r4, #3992] @ 0xf98 │ │ │ │ cmp r3, #0 │ │ │ │ - beq.n 395fe │ │ │ │ - ldr r3, [pc, #348] @ (3966c ) │ │ │ │ + beq.n 39586 │ │ │ │ + ldr r3, [pc, #348] @ (395f4 ) │ │ │ │ ldr.w r2, [r4, #3940] @ 0xf64 │ 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#28] │ │ │ │ @ instruction: 0xf90e3ec3 │ │ │ │ ldrd r3, r1, [r9, #-152]! @ 0x98 │ │ │ │ add r4, sp, #32 │ │ │ │ subs r7, #124 @ 0x7c │ │ │ │ - b.n 3996c │ │ │ │ + b.n 399e4 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - b.n 3996c │ │ │ │ + b.n 399e4 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - b.n 39910 │ │ │ │ + b.n 39988 │ │ │ │ movs r1, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d15} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3520] @ 0xdc0 │ │ │ │ - ldr r2, [pc, #988] @ (39f70 ) │ │ │ │ + ldr r2, [pc, #988] @ (39ef8 ) │ │ │ │ sub sp, #476 @ 0x1dc │ │ │ │ - ldr r3, [pc, #988] @ (39f74 ) │ │ │ │ + ldr r3, [pc, #988] @ (39efc ) │ │ │ │ add r2, pc │ │ │ │ - ldr.w r9, [pc, #988] @ 39f78 │ │ │ │ + ldr.w r9, [pc, #988] @ 39f00 │ │ │ │ add r9, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r3, [r3, #0] │ │ │ │ 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[pc, #92] @ (3a9a0 ) │ │ │ │ + ldr r3, [pc, #80] @ (3a994 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #52] @ 0x34 │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.n 3a9f8 │ │ │ │ + bne.n 3a980 │ │ │ │ mov r0, sl │ │ │ │ add sp, #56 @ 0x38 │ │ │ │ vpop {d8-d9} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, pc} │ │ │ │ - ldr r1, [pc, #56] @ (3aa14 ) │ │ │ │ + ldr r1, [pc, #56] @ (3a99c ) │ │ │ │ ldr r4, [r2, r1] │ │ │ │ add.w r2, r3, r3, lsl #4 │ │ │ │ add.w r3, r3, r2, lsl #2 │ │ │ │ mov r2, r8 │ │ │ │ add.w r1, r4, r3, lsl #6 │ │ │ │ - bl 3a410 │ │ │ │ + bl 3a398 │ │ │ │ cmp r0, #0 │ │ │ │ - beq.n 3a93c │ │ │ │ + beq.n 3a8c4 │ │ │ │ ldrsh.w sl, [r6, #824] @ 0x338 │ │ │ │ - b.n 3a9b8 │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 3a940 │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop.w │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ strh r0, [r0, #36] @ 0x24 │ │ │ │ asrs r6, r5 │ │ │ │ - bvs.n 3a9dc │ │ │ │ + bvc.n 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bl 3de20 │ │ │ │ vldr d7, [r4, #760] @ 0x2f8 │ │ │ │ vsub.f64 d0, d7, d0 │ │ │ │ vcmpe.f64 d0, d8 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bls.w 3aef8 │ │ │ │ + bls.w 3ae80 │ │ │ │ vstr d0, [r4, #760] @ 0x2f8 │ │ │ │ mov r0, r5 │ │ │ │ add r5, sp, #72 @ 0x48 │ │ │ │ mov r2, r5 │ │ │ │ mov r1, r7 │ │ │ │ - bl b264 │ │ │ │ + bl b394 │ │ │ │ ldr.w r3, [r4, #812] @ 0x32c │ │ │ │ vldr d5, [r4, #760] @ 0x2f8 │ │ │ │ mov r1, r5 │ │ │ │ vldr d6, [r4, #768] @ 0x300 │ │ │ │ mov r0, r4 │ │ │ │ vldr d7, [sp, #88] @ 0x58 │ │ │ │ vldr d8, [r3, #440] @ 0x1b8 │ │ │ │ - vldr d9, [pc, #348] @ 3af38 │ │ │ │ + vldr d9, [pc, #348] @ 3aec0 │ │ │ │ vadd.f64 d8, d8, d5 │ │ │ │ vadd.f64 d8, d8, d6 │ │ │ │ vadd.f64 d7, d7, d8 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vstr d7, [sp, #88] @ 0x58 │ │ │ │ - bl 3f040 │ │ │ │ + bl 3efc8 │ │ │ │ vldr d7, [sp, #80] @ 0x50 │ │ │ │ vldr d4, [sp, #72] @ 0x48 │ │ │ │ - ldr r3, [pc, #324] @ (3af44 ) │ │ │ │ + ldr r3, [pc, #324] @ (3aecc ) │ │ │ │ vdiv.f64 d1, d7, d8 │ │ │ │ vldr d5, [r8] │ │ │ │ vdiv.f64 d2, d4, d8 │ │ │ │ vldr d6, [r4, #208] @ 0xd0 │ │ │ │ vldr d7, [r4, #200] @ 0xc8 │ │ │ │ ldr r3, [r6, r3] │ │ │ │ add.w r6, r4, #264 @ 0x108 │ │ │ │ vmul.f64 d6, d5, d6 │ │ │ │ - vldr d4, [pc, #272] @ 3af30 │ │ │ │ + vldr d4, [pc, #272] @ 3aeb8 │ │ │ │ vmul.f64 d7, d5, d7 │ │ │ │ mov r0, r6 │ │ │ │ vldr d3, [r3] │ │ │ │ vmul.f64 d1, d1, d9 │ │ │ │ vmul.f64 d2, d2, d9 │ │ │ │ vmla.f64 d6, d1, d3 │ │ │ │ vmla.f64 d7, d2, d3 │ │ │ │ @@ -62391,21 +62382,21 @@ │ │ │ │ vldr d7, [r4, #280] @ 0x118 │ │ │ │ vmul.f64 d6, d6, d9 │ │ │ │ vmla.f64 d5, d6, d3 │ │ │ │ vdiv.f64 d1, d1, d2 │ │ │ │ vmls.f64 d7, d5, d4 │ │ │ │ vdiv.f64 d0, d0, d2 │ │ │ │ vstr d7, [r4, #280] @ 0x118 │ │ │ │ - bl e2f8 │ │ │ │ + bl ea68 │ │ │ │ mov r1, r9 │ │ │ │ mov r0, r6 │ │ │ │ - bl f320 │ │ │ │ + bl fa90 │ │ │ │ add.w r1, r4, #344 @ 0x158 │ │ │ │ mov r0, r6 │ │ │ │ - bl fbb0 │ │ │ │ + bl 10320 │ │ │ │ vldr d6, [sp, #72] @ 0x48 │ │ │ │ vldr d3, [sp, #80] @ 0x50 │ │ │ │ mov r0, r4 │ │ │ │ vldr d7, [sp, #88] @ 0x58 │ │ │ │ vdiv.f64 d1, d6, d8 │ │ │ │ vldr d4, [r8] │ │ │ │ vdiv.f64 d2, d3, d8 │ │ │ │ @@ -62418,107 +62409,107 @@ │ │ │ │ vmul.f64 d3, d3, d9 │ │ │ │ vmla.f64 d5, d1, d4 │ │ │ │ vmla.f64 d6, d2, d4 │ │ │ │ vmla.f64 d7, d3, d4 │ │ │ │ vstr d5, [r4, #200] @ 0xc8 │ │ │ │ vstr d6, [r4, #208] @ 0xd0 │ │ │ │ vstr d7, [r4, #216] @ 0xd8 │ │ │ │ - bl 3a04c │ │ │ │ + bl 39fd4 │ │ │ │ mov r5, r0 │ │ │ │ - cbz r0, 3af02 │ │ │ │ - ldr r0, [pc, #96] @ (3af48 ) │ │ │ │ + cbz r0, 3ae8a │ │ │ │ + ldr r0, [pc, #96] @ (3aed0 ) │ │ │ │ add r0, pc │ │ │ │ - b.n 3aaa2 │ │ │ │ + b.n 3aa2a │ │ │ │ ldr r2, [r4, #12] │ │ │ │ lsls r2, r2, #25 │ │ │ │ - bmi.n 3af12 │ │ │ │ + bmi.n 3ae9a │ │ │ │ vstr d8, [r3] │ │ │ │ - b.n 3ad22 │ │ │ │ + b.n 3acaa │ │ │ │ vstr d8, [r4, #760] @ 0x2f8 │ │ │ │ vstr d8, [r4, #688] @ 0x2b0 │ │ │ │ - b.n 3adb4 │ │ │ │ + b.n 3ad3c │ │ │ │ mov r0, r4 │ │ │ │ - bl 2a248 │ │ │ │ + bl 2a1d0 │ │ │ │ mov r0, r5 │ │ │ │ - b.n 3aaa2 │ │ │ │ - vldr d6, [pc, #24] @ 3af28 │ │ │ │ - b.n 3ac1e │ │ │ │ - ldr r0, [pc, #56] @ (3af4c ) │ │ │ │ + b.n 3aa2a │ │ │ │ + vldr d6, [pc, #24] @ 3aeb0 │ │ │ │ + b.n 3aba6 │ │ │ │ + ldr r0, [pc, #56] @ (3aed4 ) │ │ │ │ add r0, pc │ │ │ │ - b.n 3aaa2 │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 3aa2a │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop.w │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ strh r0, [r0, #0] │ │ │ │ ... │ │ │ │ subs r0, r6, r1 │ │ │ │ ldr r2, [r0, #40] @ 0x28 │ │ │ │ strh r2, [r3, #14] │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ cmp r0, #246 @ 0xf6 │ │ │ │ ldrh r4, [r3, #58] @ 0x3a │ │ │ │ asrs r2, r0, #23 │ │ │ │ eors r0, r0 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r1, #10 │ │ │ │ + lsls r4, r0, #10 │ │ │ │ movs r0, r0 │ │ │ │ - asrs r0, r6, #11 │ │ │ │ + asrs r4, r2, #20 │ │ │ │ movs r1, r0 │ │ │ │ - asrs r0, r5, #10 │ │ │ │ + asrs r4, r1, #19 │ │ │ │ movs r1, r0 │ │ │ │ push {r4, r5, r6, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 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[r7, #0] │ │ │ │ movs r2, r0 │ │ │ │ - bl fffdfa3e <__bss_end__@@Base+0xfff38e06> │ │ │ │ - str r6, [r6, #0] │ │ │ │ + bl fffdf9c6 <__bss_end__@@Base+0xfff38e26> │ │ │ │ + str r6, [r2, #0] │ │ │ │ movs r2, r0 │ │ │ │ - lsrs r6, r7, #5 │ │ │ │ + lsrs r2, r4, #14 │ │ │ │ movs r1, r0 │ │ │ │ - ldr r2, [pc, #84] @ (3baa0 ) │ │ │ │ + ldr r2, [pc, #84] @ (3ba28 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, #0] │ │ │ │ - cbz r3, 3ba9c │ │ │ │ + cbz r3, 3ba24 │ │ │ │ push {r4, r5} │ │ │ │ movs r5, #0 │ │ │ │ ldr r4, [r2, #4] │ │ │ │ ldrd r2, r1, [r3, #4] │ │ │ │ cmp r1, r0 │ │ │ │ - beq.n 3ba6a │ │ │ │ - cbz r2, 3ba7e │ │ │ │ + beq.n 3b9f2 │ │ │ │ + cbz r2, 3ba06 │ │ │ │ mov r3, r2 │ │ │ │ ldrd r2, r1, [r3, #4] │ │ │ │ cmp r1, r0 │ │ │ │ - bne.n 3ba5e │ │ │ │ + bne.n 3b9e6 │ │ │ │ ldr r1, [r3, #0] │ │ │ │ - cbz r1, 3ba90 │ │ │ │ + cbz r1, 3ba18 │ │ │ │ str r2, [r1, #4] │ │ │ │ movs r5, #1 │ │ │ │ - cbz r2, 3ba84 │ │ │ │ + cbz r2, 3ba0c │ │ │ │ str r1, [r2, #0] │ │ │ │ str r4, [r3, #4] │ │ │ │ mov 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lsls r0, r5, #11 │ │ │ │ movs r0, r0 │ │ │ │ - stmia r3!, {r6, r7} │ │ │ │ + stmia r4!, {r3, r4, r5} │ │ │ │ movs r1, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d15} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #2776] @ 0xad8 │ │ │ │ - ldr r3, [pc, #584] @ (3bef0 ) │ │ │ │ + ldr r3, [pc, #584] @ (3be78 ) │ │ │ │ subw sp, sp, #1220 @ 0x4c4 │ │ │ │ - ldr r2, [pc, #584] @ (3bef4 ) │ │ │ │ + ldr r2, [pc, #584] @ (3be7c ) │ │ │ │ mov r5, r1 │ │ │ │ add r3, pc │ │ │ │ ldrsh.w r6, [r1, #150] @ 0x96 │ │ │ │ mov r7, r3 │ │ │ │ str r3, [sp, #32] │ │ │ │ - ldr r3, [pc, #572] @ (3bef8 ) │ │ │ │ + ldr r3, [pc, #572] @ (3be80 ) │ │ │ │ add r2, pc │ │ │ │ str r0, [sp, #20] │ │ │ │ ldr r0, [r1, #20] │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r3, [r3, #0] │ │ │ │ str.w r3, [sp, #1212] @ 0x4bc │ │ │ │ mov.w r3, #0 │ │ │ │ - bl 138fa │ │ │ │ + bl 13a3c │ │ │ │ mov r4, r0 │ │ │ │ ldr r0, [r5, #20] │ │ │ │ - bl 13912 │ │ │ │ + bl 13a40 │ │ │ │ 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#148] @ 0x94 │ │ │ │ vdiv.f64 d9, d7, d5 │ │ │ │ @@ -63835,57 +63826,57 @@ │ │ │ │ subs r3, r3, r2 │ │ │ │ str r1, [sp, #48] @ 0x30 │ │ │ │ vcvt.f64.s32 d13, s15 │ │ │ │ vmov d8, r3, r3 │ │ │ │ vcvt.f64.s32 d8, d8, #1 │ │ │ │ vmul.f64 d14, d9, d14 │ │ │ │ vmul.f64 d10, d9, d10 │ │ │ │ - bl 2d6d4 │ │ │ │ + bl 2d65c │ │ │ │ cmp r0, #0 │ │ │ │ - beq.w 3cb0c │ │ │ │ + beq.w 3ca94 │ │ │ │ ldr.w r0, [r4, #776] @ 0x308 │ │ │ │ orr.w r0, r0, #262144 @ 0x40000 │ │ │ │ - ldr r1, [pc, #336] @ (3bf0c ) │ │ │ │ - ldr r6, [pc, #336] @ (3bf10 ) │ │ │ │ + ldr r1, [pc, #336] @ (3be94 ) │ │ │ │ + ldr r6, [pc, #336] @ (3be98 ) │ │ │ │ add r1, pc │ │ │ │ ldr r3, [sp, #20] │ │ │ │ add r6, pc │ │ │ │ ldr r2, [r1, #0] │ │ │ │ str.w r0, [r3, #776] @ 0x308 │ │ │ │ str r1, [r6, #36] @ 0x24 │ │ │ │ cmp r2, #0 │ │ │ │ - beq.w 3bf20 │ │ │ │ - ldr.w r9, [pc, #320] @ 3bf14 │ │ │ │ + beq.w 3bea8 │ │ │ │ + ldr.w r9, [pc, #320] @ 3be9c │ │ │ │ movs r4, #0 │ │ │ │ str.w sl, [sp, #40] @ 0x28 │ │ │ │ mov fp, r4 │ │ │ │ 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+63886,122 @@ │ │ │ │ vcvt.s32.f64 s10, d5 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r2, s13 │ │ │ │ vcvt.s32.f64 s13, d3 │ │ │ │ vmov r3, s15 │ │ │ │ vstr s10, [sp] │ │ │ │ vmov r1, s13 │ │ │ │ - bl 4abc │ │ │ │ - ldr r3, [pc, #168] @ (3bf18 ) │ │ │ │ + bl 4a54 │ │ │ │ + ldr r3, [pc, #168] @ (3bea0 ) │ │ │ │ ldr r2, [sp, #32] │ │ │ │ mov r1, r8 │ │ │ │ ldr r0, [sp, #36] @ 0x24 │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldrh r2, [r3, #0] │ │ │ │ - bl 5b70 │ │ │ │ + bl 5b08 │ │ │ │ vldr d1, [sp, #24] │ │ │ │ ldr r3, [r6, #36] @ 0x24 │ │ │ │ vmov.f64 d7, #96 @ 0x3f000000 0.5 │ │ │ │ vmov.f64 d0, d15 │ │ │ │ vmov.f64 d2, d14 │ │ │ │ vmla.f64 d1, d9, d7 │ │ │ │ vmla.f64 d0, d8, d7 │ │ │ │ ldr r1, [r3, #4] │ │ │ │ mov r2, r7 │ │ │ │ ldr r0, [r5, #36] @ 0x24 │ │ │ │ adds r4, #1 │ │ │ │ - bl 2aac0 │ │ │ │ + bl 2aa48 │ │ │ │ cmp r4, #7 │ │ │ │ - bne.n 3bdee │ │ │ │ + bne.n 3bd76 │ │ │ │ ldr r3, [r6, #36] @ 0x24 │ │ │ │ add.w fp, fp, #1 │ │ │ │ add.w r1, r3, #12 │ │ │ │ str r1, [r6, #36] @ 0x24 │ │ │ │ ldr r2, [r3, #12] │ │ │ │ - cbz r2, 3bf1c │ │ │ │ + cbz r2, 3bea4 │ │ │ │ cmp.w fp, #2 │ │ │ │ - beq.w 3d74c │ │ │ │ + beq.w 3d6d4 │ │ │ │ vmov s15, fp │ │ │ │ movs r4, #0 │ │ │ │ vcvt.f64.s32 d11, s15 │ │ │ │ - b.n 3bdfe │ │ │ │ + b.n 3bd86 │ │ │ │ nop.w │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #185 @ 0xb9 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ str r4, [r5, r7] │ │ │ │ subs r0, r7, #2 │ │ │ │ @ instruction: 0xeb853fb1 │ │ │ │ ... │ │ │ │ - stmia r3!, {r1, r2, r3, r6} │ │ │ │ + stmia r3!, {r1, r2, r6, r7} │ │ │ │ movs r1, r0 │ │ │ │ - stmia r3!, {r1, r6} │ │ │ │ + stmia r3!, {r1, r3, r4, r5, r7} │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ - movs r0, r0 │ │ │ │ lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r1, #11 │ │ │ │ movs r0, r0 │ │ │ │ - ldrb r6, [r1, r3] │ │ │ │ - movs r2, r0 │ │ │ │ - lsls r0, r6, #11 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - sbcs.w r0, r2, #1 │ │ │ │ - ldrb r2, [r3, r0] │ │ │ │ + ldrb r6, [r5, r2] │ │ │ │ movs r2, r0 │ │ │ │ + lsls r0, r5, #11 │ │ │ │ + movs r0, r0 │ │ │ │ + adcs.w r0, r2, #1 │ │ │ │ ldrh r2, [r7, r7] │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r4, #11 │ │ │ │ + ldrh r2, [r3, r7] │ │ │ │ + movs r2, r0 │ │ │ │ + lsls r0, r3, #11 │ │ │ │ movs r0, r0 │ │ │ │ ldr.w sl, [sp, #40] @ 0x28 │ │ │ │ - ldr.w r3, [pc, #1092] @ 3c368 │ │ │ │ + ldr.w r3, [pc, #1092] @ 3c2f0 │ │ │ │ mov r0, sl │ │ │ │ ldr r6, [sp, #32] │ │ │ │ add.w r7, r5, #156 @ 0x9c │ │ │ │ ldr r1, [r5, #36] @ 0x24 │ │ │ │ ldr r3, [r6, r3] │ │ │ │ ldrh r2, [r3, #0] │ │ │ │ - bl 2aa90 │ │ │ │ + bl 2aa18 │ │ │ │ mov r0, sl │ │ │ │ - bl 2a4a0 │ │ │ │ + bl 2a428 │ │ │ │ ldr r4, [r5, #32] │ │ │ │ mov r1, r7 │ │ │ │ mov r0, r4 │ │ │ │ - bl 4dd0 │ │ │ │ - ldr.w r3, [pc, #1060] @ 3c36c │ │ │ │ + bl 4d68 │ │ │ │ + ldr.w r3, [pc, #1060] @ 3c2f4 │ │ │ │ mov r1, r7 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@@ │ │ │ │ vmov s5, r3 │ │ │ │ vcvt.f64.s32 d8, s5 │ │ │ │ vsub.f64 d7, d7, d3 │ │ │ │ vsub.f64 d7, d7, d4 │ │ │ │ vsub.f64 d7, d7, d5 │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bgt.w 3cbf2 │ │ │ │ - vldr d6, [pc, #860] @ 3c330 │ │ │ │ + bgt.w 3cb7a │ │ │ │ + vldr d6, [pc, #860] @ 3c2b8 │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bls.w 3cb1a │ │ │ │ + bls.w 3caa2 │ │ │ │ vsub.f64 d7, d7, d6 │ │ │ │ - vldr d5, [pc, #848] @ 3c338 │ │ │ │ + vldr d5, [pc, #848] @ 3c2c0 │ │ │ │ vmov.f64 d6, #148 @ 0xc0a00000 -5.0 │ │ │ │ vmls.f64 d6, d7, d5 │ │ │ │ subs r2, r7, r2 │ │ │ │ vmov.f64 d10, d8 │ │ │ │ vmov.f64 d7, #96 @ 0x3f000000 0.5 │ │ │ │ add.w r9, sp, #744 @ 0x2e8 │ │ │ │ vmov d9, r2, r2 │ │ │ │ @@ -64043,121 +64034,121 @@ │ │ │ │ vmls.f64 d10, d9, d6 │ │ │ │ vadd.f64 d7, d10, d7 │ │ │ │ vcvt.s32.f64 s14, d7 │ │ │ │ vmov r3, s14 │ │ │ │ sxth r3, r3 │ │ │ │ strh.w r3, [r9, #2] │ │ │ │ cmp r7, r3 │ │ │ │ - bgt.w 3cc48 │ │ │ │ + bgt.w 3cbd0 │ │ │ │ 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r1, r5 │ │ │ │ mov r0, r4 │ │ │ │ - bl 40b1c │ │ │ │ + bl 40aa4 │ │ │ │ mov r1, r5 │ │ │ │ mov r0, r4 │ │ │ │ - bl 41894 │ │ │ │ + bl 4181c │ │ │ │ mov r0, r5 │ │ │ │ - bl 21a4c │ │ │ │ + bl 219d4 │ │ │ │ mov r0, r5 │ │ │ │ - bl 21d00 │ │ │ │ + bl 21c88 │ │ │ │ mov r0, r5 │ │ │ │ - bl 2f630 │ │ │ │ + bl 2f5b8 │ │ │ │ mov r0, r5 │ │ │ │ - bl 2f924 │ │ │ │ + bl 2f8ac │ │ │ │ ldr r3, [sp, #56] @ 0x38 │ │ │ │ str.w r5, [r9, #16] │ │ │ │ vldr d7, [r3] │ │ │ │ add.w r3, sp, #1320 @ 0x528 │ │ │ │ str.w r3, [r9, #28] │ │ │ │ - ldr r3, [pc, #576] @ (3c378 ) │ │ │ │ + ldr r3, [pc, #576] @ (3c300 ) │ │ │ │ add r3, pc │ │ │ │ vldr d6, [r3, #40] @ 0x28 │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.n 3c15e │ │ │ │ + ble.n 3c0e6 │ │ │ │ ldr r2, [r3, #20] │ │ │ │ cmp r2, #0 │ │ │ │ ite eq │ │ │ │ moveq r2, #1 │ │ │ │ movne r2, #0 │ │ │ │ str r2, [r3, #20] │ │ │ │ - bne.w 3cc1e │ │ │ │ + bne.w 3cba6 │ │ │ │ vadd.f64 d7, d7, d9 │ │ │ │ vstr d7, [r3, #40] @ 0x28 │ │ │ │ - ldr r3, [pc, #540] @ (3c37c ) │ │ │ │ + ldr r3, [pc, #540] @ (3c304 ) │ │ │ │ add r3, pc │ │ │ │ ldr.w r8, [r3] │ │ │ │ cmp.w r8, #0 │ │ │ │ - beq.w 3cf12 │ │ │ │ + beq.w 3ce9a │ │ │ │ ldrsh.w r7, [r5, #180] @ 0xb4 │ │ │ │ add.w r1, r5, #180 @ 0xb4 │ │ │ │ ldrsh.w r3, [r5, #184] @ 0xb8 │ │ │ │ ldrsh.w r6, [r5, #182] @ 0xb6 │ │ │ │ subs r3, r3, r7 │ │ │ │ vmov s15, r3 │ │ │ │ ldrsh.w r3, [r5, #186] @ 0xba │ │ │ │ @@ -64167,126 +64158,126 @@ │ │ │ │ vmov s15, r3 │ │ │ │ mov r0, r4 │ │ │ │ str.w r6, [r9, #20] │ │ │ │ vcvt.f64.s32 d8, s15 │ │ │ │ str.w r7, [r9, #24] │ │ │ │ vstr d9, [r9, #8] │ │ │ │ vstr d8, [r9] │ │ │ │ - bl 4dd0 │ │ │ │ + bl 4d68 │ │ │ │ ldr.w r8, [sp, #20] │ │ │ │ mov r0, r8 │ │ │ │ - bl 2d45c │ │ │ │ + bl 2d3e4 │ │ │ │ vmov s28, r0 │ │ │ │ mov r0, r8 │ │ │ │ - bl 2d4a8 │ │ │ │ + bl 2d430 │ │ │ │ vmov s27, r0 │ │ │ │ mov r0, r8 │ │ │ │ - bl 2d4f0 │ │ │ │ + bl 2d478 │ │ │ │ vmov s26, r0 │ │ │ │ mov r0, fp │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ vmov.f64 d1, d8 │ │ │ │ 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vldr d6, [pc, #240] @ 3c340 │ │ │ │ + bl b284 │ │ │ │ + vldr d6, [pc, #240] @ 3c2c8 │ │ │ │ vmov.f64 d7, #80 @ 0x3e800000 0.250 │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ mov r0, fp │ │ │ │ vmla.f64 d15, d8, d6 │ │ │ │ vmla.f64 d12, d9, d7 │ │ │ │ vmov.f64 d1, d15 │ │ │ │ vmov.f64 d0, d12 │ │ │ │ - bl b23c │ │ │ │ + bl b338 │ │ │ │ ldr r3, [sp, #24] │ │ │ │ mov r2, r4 │ │ │ │ mov r1, fp │ │ │ │ ldr r0, [r6, #4] │ │ │ │ ldrh r3, [r3, #0] │ │ │ │ - bl 45dc4 │ │ │ │ + bl 45d4c │ │ │ │ mov r0, fp │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ vldr d0, [r8, #720] @ 0x2d0 │ │ │ │ movs r1, #3 │ │ │ │ mov r0, fp │ │ │ │ vadd.f64 d0, d0, d0 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ vmov.f64 d1, d8 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov r0, fp │ │ │ │ vmov.f64 d2, #112 @ 0x3f800000 1.0 │ │ │ │ - bl b180 │ │ │ │ + bl b284 │ │ │ │ vmov.f64 d1, d15 │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ vmov.f64 d0, d12 │ │ │ │ mov r0, fp │ │ │ │ - bl b23c │ │ │ │ + bl b338 │ │ │ │ ldr r3, [sp, #40] @ 0x28 │ │ │ │ mov r2, r4 │ │ │ │ mov r1, fp │ │ │ │ ldr r0, [r6, #4] │ │ │ │ ldrh r3, [r3, #0] │ │ │ │ - bl 45dc4 │ │ │ │ + bl 45d4c │ │ │ │ mov r0, r8 │ │ │ │ - bl 23628 │ │ │ │ + bl 235b0 │ │ │ │ vmov s14, r0 │ │ │ │ - vldr d6, [pc, #120] @ 3c348 │ │ │ │ + vldr d6, [pc, #120] @ 3c2d0 │ │ │ │ mov r0, fp │ │ │ │ vcvt.f64.s32 d7, s14 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ - vldr d6, [pc, #112] @ 3c350 │ │ │ │ + vldr d6, [pc, #112] @ 3c2d8 │ │ │ │ vdiv.f64 d15, d7, d6 │ │ │ │ - bl acb0 │ │ │ │ - vldr d0, [pc, #108] @ 3c358 │ │ │ │ + bl ac98 │ │ │ │ + vldr d0, [pc, #108] @ 3c2e0 │ │ │ │ vmov.f64 d7, #34 @ 0x41100000 9.0 │ │ │ │ movs r1, #3 │ │ │ │ mov r0, fp │ │ │ │ vnmls.f64 d0, d15, d7 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ vmov.f64 d1, d8 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov r0, fp │ │ │ │ vmov.f64 d2, #112 @ 0x3f800000 1.0 │ │ │ │ - bl b180 │ │ │ │ - vldr d7, [pc, #80] @ 3c360 │ │ │ │ + bl b284 │ │ │ │ + vldr d7, [pc, #80] @ 3c2e8 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vmov.f64 d0, d11 │ │ │ │ - b.n 3c384 │ │ │ │ + b.n 3c30c │ │ │ │ nop.w │ │ │ │ subs r0, r6, r1 │ │ │ │ ldr r2, [r0, #40] @ 0x28 │ │ │ │ strh r2, [r3, #14] │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ @@ -64316,191 +64307,191 @@ │ │ │ │ cmp r1, #85 @ 0x55 │ │ │ │ ldr r2, [r7, #36] @ 0x24 │ │ │ │ ands r7, r1 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ - lsls r4, r4, #11 │ │ │ │ + lsls r4, r3, #11 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r6, #9 │ │ │ │ + lsls r0, r5, #9 │ │ │ │ movs r0, r0 │ │ │ │ - ldr r0, [r5, r5] │ │ │ │ + ldr r0, [r1, r5] │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r4, #11 │ │ │ │ + lsls r0, r3, #11 │ │ │ │ movs r0, r0 │ │ │ │ - ldr r6, [r4, r2] │ │ │ │ + ldr r6, [r0, r2] │ │ │ │ movs r2, r0 │ │ │ │ - ldr r4, [r7, r1] │ │ │ │ + ldr r4, [r3, r1] │ │ │ │ movs r2, r0 │ │ │ │ - ldrsb r4, [r3, r7] │ │ │ │ + ldrsb r4, [r7, r6] │ │ │ │ movs r2, r0 │ │ │ │ mov r0, fp │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ vmla.f64 d1, d8, d7 │ │ │ │ - vldr d7, [pc, #520] @ 3c598 │ │ │ │ + vldr d7, [pc, #520] @ 3c520 │ │ │ │ vmla.f64 d0, d9, d7 │ │ │ │ - bl b23c │ │ │ │ + bl b338 │ │ │ │ ldr r3, [sp, #40] @ 0x28 │ │ │ │ ldr r0, [r6, #8] │ │ │ │ mov r2, r4 │ │ │ │ mov r1, fp │ │ │ │ ldrh r3, [r3, #0] │ │ │ │ - bl 45dc4 │ │ │ │ + bl 45d4c │ │ │ │ mov r0, r8 │ │ │ │ - bl 2d440 │ │ │ │ + bl 2d3c8 │ │ │ │ cmp r0, #0 │ │ │ │ - beq.w 3cb9e │ │ │ │ + beq.w 3cb26 │ │ │ │ mov r0, fp │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ vneg.f64 d1, d8 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov r0, fp │ │ │ │ vmov.f64 d2, #112 @ 0x3f800000 1.0 │ │ │ │ - bl b180 │ │ │ │ - vldr d9, [pc, #464] @ 3c5a0 │ │ │ │ + bl b284 │ │ │ │ + vldr d9, [pc, #464] @ 3c528 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vmov.f64 d0, d12 │ │ │ │ mov r0, fp │ │ │ │ vmov.f64 d2, #240 @ 0xbf800000 -1.0 │ │ │ │ vmla.f64 d1, d8, d9 │ │ │ │ - bl b23c │ │ │ │ - ldr r3, [pc, #520] @ (3c5f0 ) │ │ │ │ + bl b338 │ │ │ │ + ldr r3, [pc, #520] @ (3c578 ) │ │ │ │ mov r2, r4 │ │ │ │ mov r1, fp │ │ │ │ add r3, pc │ │ │ │ ldr r0, [r3, #12] │ │ │ │ ldr r3, [sp, #24] │ │ │ │ ldrh r3, [r3, #0] │ │ │ │ - bl 45dc4 │ │ │ │ + bl 45d4c │ │ │ │ ldr r3, [sp, #20] │ │ │ │ ldr.w r3, [r3, #812] @ 0x32c │ │ │ │ vldr d6, [r3, #624] @ 0x270 │ │ │ │ vldr d7, [r3, #600] @ 0x258 │ │ │ │ vcmpe.f64 d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.w 3cb5a │ │ │ │ - vldr d1, [pc, #404] @ 3c5a8 │ │ │ │ + ble.w 3cae2 │ │ │ │ + vldr d1, [pc, #404] @ 3c530 │ │ │ │ vcvt.f64.s32 d2, s28 │ │ │ │ - ldr r0, [pc, #472] @ (3c5f4 ) │ │ │ │ + ldr r0, [pc, #472] @ (3c57c ) │ │ │ │ mov ip, r9 │ │ │ │ vmov.f64 d0, d1 │ │ │ │ add r0, pc │ │ │ │ - bl 3bae8 │ │ │ │ - ldr r0, [pc, #460] @ (3c5f8 ) │ │ │ │ + bl 3ba70 │ │ │ │ + ldr r0, [pc, #460] @ (3c580 ) │ │ │ │ vcvt.f64.s32 d2, s27 │ │ │ │ mov ip, r9 │ │ │ │ - vldr d1, [pc, #356] @ 3c598 │ │ │ │ + vldr d1, [pc, #356] @ 3c520 │ │ │ │ add r0, pc │ │ │ │ - vldr d0, [pc, #376] @ 3c5b0 │ │ │ │ - bl 3bae8 │ │ │ │ - ldr r0, [pc, #444] @ (3c5fc ) │ │ │ │ + vldr d0, [pc, #376] @ 3c538 │ │ │ │ + bl 3ba70 │ │ │ │ + ldr r0, [pc, #444] @ (3c584 ) │ │ │ │ vcvt.f64.s32 d2, s26 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov ip, r9 │ │ │ │ - vldr d1, [pc, #332] @ 3c598 │ │ │ │ + vldr d1, [pc, #332] @ 3c520 │ │ │ │ add r0, pc │ │ │ │ - bl 3bae8 │ │ │ │ + bl 3ba70 │ │ │ │ ldr r3, [sp, #24] │ │ │ │ ldrsh.w fp, [r5, #194] @ 0xc2 │ │ │ │ ldrsh.w r9, [r5, #190] @ 0xbe │ │ │ │ ldrsh.w r4, [r5, #192] @ 0xc0 │ │ │ │ ldrsh.w r7, [r5, #188] @ 0xbc │ │ │ │ ldrh r6, [r3, #0] │ │ │ │ sub.w r3, fp, r9 │ │ │ │ vmov s28, r3 │ │ │ │ - bl 2a4b4 │ │ │ │ + bl 2a43c │ │ │ │ ldr r2, [r5, #36] @ 0x24 │ │ │ │ mov r3, r4 │ │ │ │ mov r1, r7 │ │ │ │ sub.w r8, r4, r7 │ │ │ │ mov r4, r0 │ │ │ │ ldr.w sl, [r2, #4] │ │ │ │ mov r2, r9 │ │ │ │ str.w fp, [sp] │ │ │ │ ldr.w fp, [sp, #60] @ 0x3c │ │ │ │ mov r0, fp │ │ │ │ - bl 4abc │ │ │ │ + bl 4a54 │ │ │ │ mov r1, fp │ │ │ │ mov r0, sl │ │ │ │ - bl 4dd0 │ │ │ │ + bl 4d68 │ │ │ │ ldr r2, [sp, #20] │ │ │ │ - vldr d5, [pc, #280] @ 3c5b8 │ │ │ │ + vldr d5, [pc, #280] @ 3c540 │ │ │ │ vmov.f64 d7, #96 @ 0x3f000000 0.5 │ │ │ │ ldr.w r3, [r2, #640] @ 0x280 │ │ │ │ vmov.f64 d4, d7 │ │ │ │ vmov s12, r3 │ │ │ │ vcvt.f64.s32 d6, d6, #15 │ │ │ │ ldr.w r3, [r2, #776] @ 0x308 │ │ │ │ lsls r3, r3, #23 │ │ │ │ it mi │ │ │ │ movmi r3, #0 │ │ │ │ vmla.f64 d4, d6, d5 │ │ │ │ it mi │ │ │ │ strmi r3, [sp, #84] @ 0x54 │ │ │ │ vcvt.s32.f64 s13, d4 │ │ │ │ vstr s13, [sp, #60] @ 0x3c │ │ │ │ - bmi.n 3c4f2 │ │ │ │ + bmi.n 3c47a │ │ │ │ vldr d6, [r2, #752] @ 0x2f0 │ │ │ │ vmla.f64 d7, d6, d5 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r3, s15 │ │ │ │ cmp r3, #120 @ 0x78 │ │ │ │ it ge │ │ │ │ movge r3, #120 @ 0x78 │ │ │ │ cmp r3, #20 │ │ │ │ it lt │ │ │ │ movlt r3, #20 │ │ │ │ subs r3, #20 │ │ │ │ str r3, [sp, #84] @ 0x54 │ │ │ │ vmov s15, r9 │ │ │ │ - vldr d9, [pc, #200] @ 3c5c0 │ │ │ │ + vldr d9, [pc, #200] @ 3c548 │ │ │ │ vcvt.f64.s32 d14, s28 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ vcvt.f64.s32 d6, s15 │ │ │ │ vmov s15, r8 │ │ │ │ add.w r8, r8, r8, lsr #31 │ │ │ │ - vldr d11, [pc, #184] @ 3c5c8 │ │ │ │ + vldr d11, [pc, #184] @ 3c550 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ - vldr d12, [pc, #184] @ 3c5d0 │ │ │ │ + vldr d12, [pc, #184] @ 3c558 │ │ │ │ add.w r7, r7, r8, asr #1 │ │ │ │ vmov s11, r7 │ │ │ │ - ldr.w r8, [pc, #220] @ 3c600 │ │ │ │ + ldr.w r8, [pc, #220] @ 3c588 │ │ │ │ mov r0, r4 │ │ │ │ vcvt.f64.s32 d8, s11 │ │ │ │ ldr r7, [r3, #12] │ │ │ │ vmul.f64 d9, d7, d9 │ │ │ │ vstr d7, [sp, #64] @ 0x40 │ │ │ │ - vldr d7, [pc, #160] @ 3c5d8 │ │ │ │ + vldr d7, [pc, #160] @ 3c560 │ │ │ │ mov.w r9, #20 │ │ │ │ and.w r3, r7, #2 │ │ │ │ add r8, pc │ │ │ │ vmov.f64 d0, d8 │ │ │ │ str r3, [sp, #80] @ 0x50 │ │ │ │ vadd.f64 d10, d9, d6 │ │ │ │ vmov.f64 d2, d9 │ │ │ │ vmla.f64 d10, d14, d7 │ │ │ │ - vldr d7, [pc, #136] @ 3c5e0 │ │ │ │ + vldr d7, [pc, #136] @ 3c568 │ │ │ │ movw r7, #52429 @ 0xcccd │ │ │ │ movt r7, #52428 @ 0xcccc │ │ │ │ movw fp, #52428 @ 0xcccc │ │ │ │ movt fp, #3276 @ 0xccc │ │ │ │ vmul.f64 d7, d9, d7 │ │ │ │ vstr d6, [sp, #72] @ 0x48 │ │ │ │ vmul.f64 d11, d9, d11 │ │ │ │ vmul.f64 d12, d9, d12 │ │ │ │ - vldr d13, [pc, #108] @ 3c5e8 │ │ │ │ + vldr d13, [pc, #108] @ 3c570 │ │ │ │ vmov.f64 d15, #240 @ 0xbf800000 -1.0 │ │ │ │ vstr d7, [sp, #40] @ 0x28 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ - bl 2a650 │ │ │ │ + bl 2a5d8 │ │ │ │ ldr.w sl, [sp, #52] @ 0x34 │ │ │ │ str.w r8, [sp, #52] @ 0x34 │ │ │ │ mov r8, r9 │ │ │ │ - b.n 3c656 │ │ │ │ + b.n 3c5de │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #233 @ 0xe9 │ │ │ │ str r6, [r4, #100] @ 0x64 │ │ │ │ str r6, [r4, #100] @ 0x64 │ │ │ │ str r6, [r4, #100] @ 0x64 │ │ │ │ @@ -64535,181 +64526,183 @@ │ │ │ │ subs r7, #164 @ 0xa4 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ subs r7, #195 @ 0xc3 │ │ │ │ ldrb r7, [r0, r0] │ │ │ │ adds r3, #20 │ │ │ │ - add r6, pc, #152 @ (adr r6, 3c688 ) │ │ │ │ + add r6, pc, #152 @ (adr r6, 3c610 ) │ │ │ │ subs r4, #145 @ 0x91 │ │ │ │ - strb r0, [r6, r7] │ │ │ │ + strb r0, [r2, r7] │ │ │ │ movs r2, r0 │ │ │ │ - vaddl.u16 q8, d6, d0 │ │ │ │ - vaddl.u8 q8, d12, d0 │ │ │ │ - vaddl.u q0, d10, d0 │ │ │ │ - b.n 3c4fc │ │ │ │ - movs r0, r0 │ │ │ │ + lsls r2, r7, #7 │ │ │ │ + movs r1, r0 │ │ │ │ + lsls r0, r6, #7 │ │ │ │ + movs r1, r0 │ │ │ │ + lsls r6, r3, #7 │ │ │ │ + movs r1, r0 │ │ │ │ + @ instruction: 0xe9b80000 │ │ │ │ add.w r8, r8, #10 │ │ │ │ cmp.w r8, #110 @ 0x6e │ │ │ │ - beq.n 3c6c4 │ │ │ │ + beq.n 3c64c │ │ │ │ sub.w r3, r8, #20 │ │ │ │ vmov s12, r3 │ │ │ │ - vldr d7, [pc, #912] @ 3c9a8 │ │ │ │ + vldr d7, [pc, #912] @ 3c930 │ │ │ │ add.w r9, sp, #96 @ 0x60 │ │ │ │ vcvt.f64.s32 d6, s12 │ │ │ │ - vldr d2, [pc, #908] @ 3c9b0 │ │ │ │ - vldr d0, [pc, #912] @ 3c9b8 │ │ │ │ + vldr d2, [pc, #908] @ 3c938 │ │ │ │ + vldr d0, [pc, #912] @ 3c940 │ │ │ │ mov r1, r9 │ │ │ │ - vldr d4, [pc, #912] @ 3c9c0 │ │ │ │ + vldr d4, [pc, #912] @ 3c948 │ │ │ │ add r0, sp, #104 @ 0x68 │ │ │ │ - vldr d5, [pc, #916] @ 3c9c8 │ │ │ │ + vldr d5, [pc, #916] @ 3c950 │ │ │ │ vmul.f64 d6, d6, d7 │ │ │ │ vdiv.f64 d7, d6, d2 │ │ │ │ vsub.f64 d0, d7, d0 │ │ │ │ vmul.f64 d0, d0, d4 │ │ │ │ vdiv.f64 d0, d0, d5 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ vldr d13, [sp, #96] @ 0x60 │ │ │ │ vldr d15, [sl, #-8] │ │ │ │ vmov.f64 d3, d10 │ │ │ │ vmov.f64 d2, d8 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vmla.f64 d3, d11, d15 │ │ │ │ vmla.f64 d2, d11, d13 │ │ │ │ vmla.f64 d1, d9, d15 │ │ │ │ vmla.f64 d0, d9, d13 │ │ │ │ mov r0, r4 │ │ │ │ - bl 2a50c │ │ │ │ + bl 2a494 │ │ │ │ cmp.w r8, #20 │ │ │ │ - beq.w 3cb36 │ │ │ │ + beq.w 3cabe │ │ │ │ mul.w r2, r7, r8 │ │ │ │ cmp.w fp, r2, ror #2 │ │ │ │ - bcc.n 3c604 │ │ │ │ + bcc.n 3c58c │ │ │ │ ldr.w r9, [sp, #36] @ 0x24 │ │ │ │ mov r2, r8 │ │ │ │ ldr r1, [sp, #52] @ 0x34 │ │ │ │ add.w r8, r8, #10 │ │ │ │ mov r0, r9 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vmla.f64 d1, d12, d15 │ │ │ │ vmla.f64 d0, d12, d13 │ │ │ │ ldr r0, [r5, #36] @ 0x24 │ │ │ │ mov r2, r6 │ │ │ │ mov r1, r9 │ │ │ │ vldr d2, [sp, #40] @ 0x28 │ │ │ │ - bl 2aac0 │ │ │ │ + bl 2aa48 │ │ │ │ cmp.w r8, #110 @ 0x6e │ │ │ │ - bne.n 3c60e │ │ │ │ - vldr d11, [pc, #760] @ 3c9c0 │ │ │ │ + bne.n 3c596 │ │ │ │ + vldr d11, [pc, #760] @ 3c948 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ - vldr d2, [pc, #768] @ 3c9d0 │ │ │ │ + vldr d2, [pc, #768] @ 3c958 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ - vldr d3, [pc, #768] @ 3c9d8 │ │ │ │ + vldr d3, [pc, #768] @ 3c960 │ │ │ │ mov r0, r4 │ │ │ │ vmov.f64 d4, d11 │ │ │ │ vmul.f64 d2, d9, d2 │ │ │ │ - bl 2a780 │ │ │ │ - vldr d7, [pc, #760] @ 3c9e0 │ │ │ │ - vldr d2, [pc, #764] @ 3c9e8 │ │ │ │ + bl 2a708 │ │ │ │ + vldr d7, [pc, #760] @ 3c968 │ │ │ │ + vldr d2, [pc, #764] @ 3c970 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ - ldr r1, [pc, #844] @ (3ca40 ) │ │ │ │ + ldr r1, [pc, #844] @ (3c9c8 ) │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vmla.f64 d1, d9, d7 │ │ │ │ ldr r0, [r5, #36] @ 0x24 │ │ │ │ vmul.f64 d2, d9, d2 │ │ │ │ add r1, pc │ │ │ │ mov r2, r6 │ │ │ │ - bl 2aac0 │ │ │ │ + bl 2aa48 │ │ │ │ vldr s15, [sp, #84] @ 0x54 │ │ │ │ - vldr d6, [pc, #664] @ 3c9a8 │ │ │ │ + vldr d6, [pc, #664] @ 3c930 │ │ │ │ vmov.f64 d3, d12 │ │ │ │ - vldr d2, [pc, #688] @ 3c9c8 │ │ │ │ + vldr d2, [pc, #688] @ 3c950 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ mov r0, r4 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ - vldr d6, [pc, #640] @ 3c9b0 │ │ │ │ + vldr d6, [pc, #640] @ 3c938 │ │ │ │ vdiv.f64 d4, d7, d6 │ │ │ │ - vldr d7, [pc, #640] @ 3c9b8 │ │ │ │ + vldr d7, [pc, #640] @ 3c940 │ │ │ │ vsub.f64 d4, d4, d7 │ │ │ │ vmul.f64 d4, d4, d11 │ │ │ │ vdiv.f64 d2, d4, d2 │ │ │ │ - bl 2a8f0 │ │ │ │ + bl 2a878 │ │ │ │ ldr r3, [sp, #80] @ 0x50 │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 3cbb8 │ │ │ │ - ldr r3, [pc, #752] @ (3ca44 ) │ │ │ │ + beq.w 3cb40 │ │ │ │ + ldr r3, [pc, #752] @ (3c9cc ) │ │ │ │ add r3, pc │ │ │ │ ldr r7, [sp, #36] @ 0x24 │ │ │ │ - ldr r1, [pc, #752] @ (3ca48 ) │ │ │ │ + ldr r1, [pc, #752] @ (3c9d0 ) │ │ │ │ ldr r2, [sp, #60] @ 0x3c │ │ │ │ mov r0, r7 │ │ │ │ add r1, pc │ │ │ │ - blx 35fc │ │ │ │ - vldr d7, [pc, #652] @ 3c9f0 │ │ │ │ - vldr d2, [pc, #656] @ 3c9f8 │ │ │ │ + blx 3598 │ │ │ │ + vldr d7, [pc, #652] @ 3c978 │ │ │ │ + vldr d2, [pc, #656] @ 3c980 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ mov r2, r6 │ │ │ │ mov r1, r7 │ │ │ │ vmls.f64 d1, d9, d7 │ │ │ │ ldr r0, [r5, #36] @ 0x24 │ │ │ │ vmul.f64 d2, d9, d2 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ - bl 2aac0 │ │ │ │ - vldr d2, [pc, #632] @ 3ca00 │ │ │ │ - vldr d7, [pc, #636] @ 3ca08 │ │ │ │ + bl 2aa48 │ │ │ │ + vldr d2, [pc, #632] @ 3c988 │ │ │ │ + vldr d7, [pc, #636] @ 3c990 │ │ │ │ vmov.f64 d3, d10 │ │ │ │ vmov.f64 d1, d10 │ │ │ │ mov r0, r4 │ │ │ │ vmul.f64 d2, d9, d2 │ │ │ │ vmls.f64 d3, d9, d7 │ │ │ │ vmov.f64 d7, #104 @ 0x3f400000 0.750 │ │ │ │ vmls.f64 d1, d9, d7 │ │ │ │ vsub.f64 d0, d8, d2 │ │ │ │ vadd.f64 d2, d8, d2 │ │ │ │ - bl 2a598 │ │ │ │ + bl 2a520 │ │ │ │ ldr r0, [sp, #20] │ │ │ │ - bl 3de98 │ │ │ │ - ldr r3, [pc, #656] @ (3ca4c ) │ │ │ │ + bl 3de20 │ │ │ │ + ldr r3, [pc, #656] @ (3c9d4 ) │ │ │ │ ldr r2, [sp, #32] │ │ │ │ - vldr d7, [pc, #592] @ 3ca10 │ │ │ │ + vldr d7, [pc, #592] @ 3c998 │ │ │ │ ldr r3, [r2, r3] │ │ │ │ vmul.f64 d0, d0, d7 │ │ │ │ vldr d6, [r3] │ │ │ │ vdiv.f64 d7, d0, d6 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r3, s15 │ │ │ │ cmp r3, #49 @ 0x31 │ │ │ │ - bgt.w 3cb3c │ │ │ │ + bgt.w 3cac4 │ │ │ │ adds r3, #3 │ │ │ │ movw r2, #26215 @ 0x6667 │ │ │ │ movt r2, #26214 @ 0x6666 │ │ │ │ asrs r7, r3, #31 │ │ │ │ smull r1, r2, r2, r3 │ │ │ │ rsb r7, r7, r2, asr #1 │ │ │ │ add.w r7, r7, r7, lsl #2 │ │ │ │ - vldr d6, [pc, #544] @ 3ca18 │ │ │ │ + vldr d6, [pc, #544] @ 3c9a0 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ vldr d5, [sp, #64] @ 0x40 │ │ │ │ mov r2, r6 │ │ │ │ vldr d9, [sp, #72] @ 0x48 │ │ │ │ adds r7, #5 │ │ │ │ - vldr d7, [pc, #532] @ 3ca20 │ │ │ │ + vldr d7, [pc, #532] @ 3c9a8 │ │ │ │ vmul.f64 d15, d5, d6 │ │ │ │ - ldr r1, [pc, #572] @ (3ca50 ) │ │ │ │ + ldr r1, [pc, #572] @ (3c9d8 ) │ │ │ │ vmov.f64 d1, d9 │ │ │ │ ldr r0, [r5, #36] @ 0x24 │ │ │ │ vmla.f64 d1, d14, d7 │ │ │ │ add r1, pc │ │ │ │ vmov.f64 d2, d15 │ │ │ │ - bl 2aac0 │ │ │ │ + bl 2aa48 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ movw r1, #26215 @ 0x6667 │ │ │ │ movt r1, #26214 @ 0x6666 │ │ │ │ movs r0, #10 │ │ │ │ vldr d7, [r3, #760] @ 0x2f8 │ │ │ │ smull ip, r3, r1, r7 │ │ │ │ asrs r7, r7, #31 │ │ │ │ @@ -64718,76 +64711,76 @@ │ │ │ │ vmov r2, s15 │ │ │ │ adds r2, #5 │ │ │ │ smull r3, r1, r1, r2 │ │ │ │ asrs r2, r2, #31 │ │ │ │ mul.w r3, r0, r7 │ │ │ │ ldr r7, [sp, #36] @ 0x24 │ │ │ │ rsb r2, r2, r1, asr #2 │ │ │ │ - ldr r1, [pc, #504] @ (3ca54 ) │ │ │ │ + ldr r1, [pc, #504] @ (3c9dc ) │ │ │ │ add r1, pc │ │ │ │ mul.w r2, r0, r2 │ │ │ │ mov r0, r7 │ │ │ │ - blx 35fc │ │ │ │ - vldr d7, [pc, #444] @ 3ca28 │ │ │ │ + blx 3598 │ │ │ │ + vldr d7, [pc, #444] @ 3c9b0 │ │ │ │ vmov.f64 d1, d9 │ │ │ │ vmov.f64 d2, d15 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ ldr r0, [r5, #36] @ 0x24 │ │ │ │ vmla.f64 d1, d14, d7 │ │ │ │ mov r2, r6 │ │ │ │ mov r1, r7 │ │ │ │ - bl 2aac0 │ │ │ │ + bl 2aa48 │ │ │ │ ldr r2, [sp, #24] │ │ │ │ ldr r1, [r5, #36] @ 0x24 │ │ │ │ mov r0, r4 │ │ │ │ ldrh r2, [r2, #0] │ │ │ │ - bl 2aa90 │ │ │ │ + bl 2aa18 │ │ │ │ mov r0, r4 │ │ │ │ - bl 2a4a0 │ │ │ │ + bl 2a428 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ ldr.w r3, [r3, #812] @ 0x32c │ │ │ │ ldr.w r3, [r3, #504] @ 0x1f8 │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 3cae8 │ │ │ │ + beq.w 3ca70 │ │ │ │ ldr r3, [sp, #56] @ 0x38 │ │ │ │ vldr d7, [r3] │ │ │ │ - ldr r3, [pc, #424] @ (3ca58 ) │ │ │ │ + ldr r3, [pc, #424] @ (3c9e0 ) │ │ │ │ add r3, pc │ │ │ │ vldr d6, [r3, #48] @ 0x30 │ │ │ │ vcmpe.f64 d7, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.n 3c8dc │ │ │ │ + ble.n 3c864 │ │ │ │ ldr r2, [r3, #56] @ 0x38 │ │ │ │ cmp r2, #0 │ │ │ │ ite eq │ │ │ │ moveq r2, #1 │ │ │ │ movne r2, #0 │ │ │ │ str r2, [r3, #56] @ 0x38 │ │ │ │ - bne.w 3ccec │ │ │ │ - vldr d6, [pc, #268] @ 3c9e0 │ │ │ │ + bne.w 3cc74 │ │ │ │ + vldr d6, [pc, #268] @ 3c968 │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ vstr d7, [r3, #48] @ 0x30 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ vmov.f64 d3, #96 @ 0x3f000000 0.5 │ │ │ │ ldrsh.w r1, [r5, #188] @ 0xbc │ │ │ │ add r7, sp, #864 @ 0x360 │ │ │ │ vmov s13, r1 │ │ │ │ ldrsh.w r2, [r5, #190] @ 0xbe │ │ │ │ - vldr d1, [pc, #316] @ 3ca30 │ │ │ │ + vldr d1, [pc, #316] @ 3c9b8 │ │ │ │ mov r0, r7 │ │ │ │ vldr d8, [r3, #704] @ 0x2c0 │ │ │ │ vcvt.f64.s32 d2, s13 │ │ │ │ ldrsh.w r3, [r5, #192] @ 0xc0 │ │ │ │ vmov s13, r2 │ │ │ │ - vldr d7, [pc, #240] @ 3c9f8 │ │ │ │ + vldr d7, [pc, #240] @ 3c980 │ │ │ │ subs r3, r3, r1 │ │ │ │ vcvt.f64.s32 d5, s13 │ │ │ │ vmov s13, r3 │ │ │ │ ldrsh.w r3, [r5, #194] @ 0xc2 │ │ │ │ - vldr d4, [pc, #268] @ 3ca28 │ │ │ │ + vldr d4, [pc, #268] @ 3c9b0 │ │ │ │ vcvt.f64.s32 d6, s13 │ │ │ │ subs r3, r3, r2 │ │ │ │ vcmpe.f64 d8, d4 │ │ │ │ vmla.f64 d2, d6, d1 │ │ │ │ vmul.f64 d6, d6, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ vcvt.s32.f64 s13, d6 │ │ │ │ @@ -64803,36 +64796,36 @@ │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vcvt.s32.f64 s11, d5 │ │ │ │ vmov r4, s15 │ │ │ │ vmov r9, s11 │ │ │ │ add.w r2, r9, r4 │ │ │ │ str r2, [sp, #0] │ │ │ │ mov r2, r9 │ │ │ │ - bmi.w 3cbbe │ │ │ │ - bl 4abc │ │ │ │ + bmi.w 3cb46 │ │ │ │ + bl 4a54 │ │ │ │ ldr r3, [sp, #48] @ 0x30 │ │ │ │ mov r1, r7 │ │ │ │ ldr r0, [r5, #32] │ │ │ │ add.w r6, r6, r6, lsr #31 │ │ │ │ - vldr d8, [pc, #180] @ 3ca38 │ │ │ │ + vldr d8, [pc, #180] @ 3c9c0 │ │ │ │ ldrh r2, [r3, #0] │ │ │ │ add.w r6, r8, r6, asr #1 │ │ │ │ - bl 6258 │ │ │ │ + bl 61f0 │ │ │ │ movs r2, #1 │ │ │ │ mov r1, r2 │ │ │ │ mov r0, r7 │ │ │ │ - bl 4b14 │ │ │ │ + bl 4aac │ │ │ │ mov r1, r7 │ │ │ │ ldr r7, [sp, #48] @ 0x30 │ │ │ │ mov.w r8, #3 │ │ │ │ - b.n 3ca5c │ │ │ │ + b.n 3c9e4 │ │ │ │ nop.w │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ - b.n 3c9b0 │ │ │ │ + b.n 3c938 │ │ │ │ eors r0, r6 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ eors r4, r2 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ @@ -64847,29 +64840,29 @@ │ │ │ │ strh r0, [r0, #0] │ │ │ │ eors r6, r4 │ │ │ │ str r6, [r4, #100] @ 0x64 │ │ │ │ str r6, [r4, #100] @ 0x64 │ │ │ │ str r6, [r4, #100] @ 0x64 │ │ │ │ subs r7, #238 @ 0xee │ │ │ │ lsls r1, r5, #1 │ │ │ │ - add r4, pc, #580 @ (adr r4, 3cc20 ) │ │ │ │ + add r4, pc, #580 @ (adr r4, 3cba8 ) │ │ │ │ asrs r4, r5, #1 │ │ │ │ ands r2, r0 │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #201 @ 0xc9 │ │ │ │ subs r0, r7, #2 │ │ │ │ @ instruction: 0xeb85b851 │ │ │ │ subs r7, #190 @ 0xbe │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #225 @ 0xe1 │ │ │ │ - bvc.n 3ca10 │ │ │ │ + bvc.n 3c998 │ │ │ │ strb r3, [r4, #2] │ │ │ │ lsrs r5, r7, #8 │ │ │ │ subs r7, #199 @ 0xc7 │ │ │ │ str r4, [r5, r7] │ │ │ │ subs r0, r7, #2 │ │ │ │ @ instruction: 0xeb853fe1 │ │ │ │ @ instruction: 0x47ae │ │ │ │ @@ -64889,34 +64882,34 @@ │ │ │ │ str r3, [r5, r7] │ │ │ │ subs r7, #232 @ 0xe8 │ │ │ │ ldmia r4!, {r0, r2, r3, r6, r7} │ │ │ │ ldmia r4!, {r2, r3, r6, r7} │ │ │ │ ldmia r4!, {r2, r3, r6, r7} │ │ │ │ subs r7, #236 @ 0xec │ │ │ │ lsrs r5, r7, #8 │ │ │ │ - add r3, pc, #860 @ (adr r3, 3cd90 ) │ │ │ │ + add r3, pc, #860 @ (adr r3, 3cd18 ) │ │ │ │ subs r5, #112 @ 0x70 │ │ │ │ subs r7, #234 @ 0xea │ │ │ │ asrs r3, r7, #17 │ │ │ │ @ instruction: 0x47ae │ │ │ │ ldrb r1, [r4, #11] │ │ │ │ subs r7, #148 @ 0x94 │ │ │ │ - ldc2 0, cr0, [r6, #-0] │ │ │ │ - bvc.n 3ca9c │ │ │ │ + vhadd.u d0, d10, d0 │ │ │ │ + bvc.n 3ca04 │ │ │ │ movs r0, r0 │ │ │ │ - stc2l 0, cr0, [r4], {0} │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + cdp2 0, 14, cr0, cr8, cr0, {0} │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ - stc2 0, cr0, [ip], {-0} │ │ │ │ - umlal r0, r0, r0, r0 │ │ │ │ - str r4, [r5, r4] │ │ │ │ + cdp2 0, 3, cr0, cr0, cr0, {0} │ │ │ │ + cdp2 0, 0, cr0, cr4, cr0, {0} │ │ │ │ + str r4, [r1, r4] │ │ │ │ movs r2, r0 │ │ │ │ ldr r0, [r5, #32] │ │ │ │ ldrh r2, [r7, #0] │ │ │ │ - bl 6258 │ │ │ │ + bl 61f0 │ │ │ │ vmov s12, r4 │ │ │ │ vcvt.f64.s32 d6, d6, #2 │ │ │ │ add.w r4, r4, r4, lsr #31 │ │ │ │ vmul.f64 d8, d9, d8 │ │ │ │ ldrh r3, [r7, #0] │ │ │ │ add.w r4, r9, r4, asr #1 │ │ │ │ vmov s15, r4 │ │ │ │ @@ -64929,236 +64922,236 @@ │ │ │ │ vsub.f64 d7, d7, d8 │ │ │ │ vstr s13, [sp, #4] │ │ │ │ ldr r0, [r5, #36] @ 0x24 │ │ │ │ add.w r3, r7, r7, lsl #1 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ add.w r3, r3, r3, lsr #31 │ │ │ │ sub.w r6, r6, r3, asr #1 │ │ │ │ - ldr r3, [pc, #776] @ (3cdb8 ) │ │ │ │ + ldr r3, [pc, #776] @ (3cd40 ) │ │ │ │ vmov r2, s15 │ │ │ │ mov r1, r6 │ │ │ │ add r3, pc │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ adds r3, r7, r4 │ │ │ │ vmov s14, r3 │ │ │ │ str r7, [sp, #4] │ │ │ │ ldr r7, [sp, #48] @ 0x30 │ │ │ │ mov r1, r6 │ │ │ │ vcvt.f64.s32 d7, s14 │ │ │ │ str.w r8, [sp] │ │ │ │ - ldr r3, [pc, #748] @ (3cdbc ) │ │ │ │ + ldr r3, [pc, #748] @ (3cd44 ) │ │ │ │ ldrh r2, [r7, #0] │ │ │ │ ldr r0, [r5, #36] @ 0x24 │ │ │ │ add r3, pc │ │ │ │ vadd.f64 d7, d7, d8 │ │ │ │ str r2, [sp, #8] │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r2, s15 │ │ │ │ - bl 9eb8 │ │ │ │ - ldr r2, [pc, #724] @ (3cdc0 ) │ │ │ │ - ldr r3, [pc, #728] @ (3cdc4 ) │ │ │ │ + bl 9d80 │ │ │ │ + ldr r2, [pc, #724] @ (3cd48 ) │ │ │ │ + ldr r3, [pc, #728] @ (3cd4c ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr.w r3, [sp, #1212] @ 0x4bc │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.w 3d766 │ │ │ │ + bne.w 3d6ee │ │ │ │ addw sp, sp, #1220 @ 0x4c4 │ │ │ │ vpop {d8-d15} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ ldr r3, [sp, #20] │ │ │ │ ldr.w r0, [r3, #776] @ 0x308 │ │ │ │ bic.w r0, r0, #262144 @ 0x40000 │ │ │ │ - b.w 3bdba │ │ │ │ - vldr d6, [pc, #604] @ 3cd78 │ │ │ │ + b.w 3bd42 │ │ │ │ + vldr d6, [pc, #604] @ 3cd00 │ │ │ │ vmul.f64 d6, d7, d6 │ │ │ │ - b.w 3bff2 │ │ │ │ - vldr d6, [pc, #600] @ 3cd80 │ │ │ │ + b.w 3bf7a │ │ │ │ + vldr d6, [pc, #600] @ 3cd08 │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ vstr d7, [r3, #24] │ │ │ │ - b.w 3bd3a │ │ │ │ + b.w 3bcc2 │ │ │ │ mov.w r8, #30 │ │ │ │ - b.n 3c60e │ │ │ │ + b.n 3c596 │ │ │ │ cmp.w r3, #500 @ 0x1f4 │ │ │ │ - bge.n 3cc2e │ │ │ │ + bge.n 3cbb6 │ │ │ │ adds r7, r3, #5 │ │ │ │ movw r3, #52429 @ 0xcccd │ │ │ │ movt r3, #52428 @ 0xcccc │ │ │ │ umull r3, r7, r3, r7 │ │ │ │ movs r3, #10 │ │ │ │ lsrs r7, r7, #3 │ │ │ │ mul.w r7, r3, r7 │ │ │ │ - b.n 3c7f4 │ │ │ │ - ldr r0, [pc, #620] @ (3cdc8 ) │ │ │ │ + b.n 3c77c │ │ │ │ + ldr r0, [pc, #620] @ (3cd50 ) │ │ │ │ vcvt.f64.s32 d2, s28 │ │ │ │ mov ip, r9 │ │ │ │ - vldr d1, [pc, #548] @ 3cd88 │ │ │ │ - vldr d0, [pc, #552] @ 3cd90 │ │ │ │ + vldr d1, [pc, #548] @ 3cd10 │ │ │ │ + vldr d0, [pc, #552] @ 3cd18 │ │ │ │ add r0, pc │ │ │ │ - bl 3bae8 │ │ │ │ - ldr r0, [pc, #600] @ (3cdcc ) │ │ │ │ + bl 3ba70 │ │ │ │ + ldr r0, [pc, #600] @ (3cd54 ) │ │ │ │ vcvt.f64.s32 d2, s27 │ │ │ │ mov ip, r9 │ │ │ │ - vldr d1, [pc, #532] @ 3cd90 │ │ │ │ + vldr d1, [pc, #532] @ 3cd18 │ │ │ │ add r0, pc │ │ │ │ - vldr d0, [pc, #536] @ 3cd98 │ │ │ │ - bl 3bae8 │ │ │ │ - ldr r0, [pc, #584] @ (3cdd0 ) │ │ │ │ + vldr d0, [pc, #536] @ 3cd20 │ │ │ │ + bl 3ba70 │ │ │ │ + ldr r0, [pc, #584] @ (3cd58 ) │ │ │ │ vcvt.f64.s32 d2, s26 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov ip, r9 │ │ │ │ - vldr d1, [pc, #508] @ 3cd90 │ │ │ │ + vldr d1, [pc, #508] @ 3cd18 │ │ │ │ add r0, pc │ │ │ │ - bl 3bae8 │ │ │ │ - b.n 3c454 │ │ │ │ + bl 3ba70 │ │ │ │ + b.n 3c3dc │ │ │ │ mov r0, fp │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ vmov.f64 d1, d8 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov r0, fp │ │ │ │ vmov.f64 d2, #112 @ 0x3f800000 1.0 │ │ │ │ - bl b180 │ │ │ │ - b.n 3c3cc │ │ │ │ - ldr r3, [pc, #536] @ (3cdd4 ) │ │ │ │ - add r3, pc │ │ │ │ - b.n 3c754 │ │ │ │ - bl 4abc │ │ │ │ - vldr d7, [pc, #476] @ 3cda0 │ │ │ │ + bl b284 │ │ │ │ + b.n 3c354 │ │ │ │ + ldr r3, [pc, #536] @ (3cd5c ) │ │ │ │ + add r3, pc │ │ │ │ + b.n 3c6dc │ │ │ │ + bl 4a54 │ │ │ │ + vldr d7, [pc, #476] @ 3cd28 │ │ │ │ vcmpe.f64 d8, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.n 3cbe0 │ │ │ │ - ble.w 3c978 │ │ │ │ - ldr r3, [pc, #512] @ (3cdd8 ) │ │ │ │ + bmi.n 3cb68 │ │ │ │ + ble.w 3c900 │ │ │ │ + ldr r3, [pc, #512] @ (3cd60 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #56] @ 0x38 │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 3c978 │ │ │ │ - ldr r3, [pc, #504] @ (3cddc ) │ │ │ │ + bne.w 3c900 │ │ │ │ + ldr r3, [pc, #504] @ (3cd64 ) │ │ │ │ mov r1, r7 │ │ │ │ ldr r2, [sp, #32] │ │ │ │ ldr r0, [r5, #32] │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldrh r2, [r3, #0] │ │ │ │ - bl 5b70 │ │ │ │ - b.n 3c978 │ │ │ │ + bl 5b08 │ │ │ │ + b.n 3c900 │ │ │ │ ldr r3, [sp, #24] │ │ │ │ mov r0, r4 │ │ │ │ str r7, [sp, #0] │ │ │ │ add.w r9, sp, #888 @ 0x378 │ │ │ │ add.w fp, sp, #1048 @ 0x418 │ │ │ │ ldrh r3, [r3, #0] │ │ │ │ str r3, [sp, #4] │ │ │ │ ldrsh.w r3, [r6, #4] │ │ │ │ ldrsh.w r1, [r6] │ │ │ │ - bl 5fe0 │ │ │ │ + bl 5f78 │ │ │ │ addw r3, sp, #1180 @ 0x49c │ │ │ │ str r3, [sp, #36] @ 0x24 │ │ │ │ add r3, sp, #840 @ 0x348 │ │ │ │ str r3, [sp, #60] @ 0x3c │ │ │ │ - b.w 3c0a2 │ │ │ │ - vldr d6, [pc, #392] @ 3cda8 │ │ │ │ + b.w 3c02a │ │ │ │ + vldr d6, [pc, #392] @ 3cd30 │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ vstr d7, [r3, #40] @ 0x28 │ │ │ │ - b.w 3c15e │ │ │ │ + b.w 3c0e6 │ │ │ │ add.w r7, r3, #50 @ 0x32 │ │ │ │ movw r3, #34079 @ 0x851f │ │ │ │ movt r3, #20971 @ 0x51eb │ │ │ │ umull r3, r7, r3, r7 │ │ │ │ movs r3, #100 @ 0x64 │ │ │ │ lsrs r7, r7, #5 │ │ │ │ mul.w r7, r3, r7 │ │ │ │ - b.n 3c7f4 │ │ │ │ + b.n 3c77c │ │ │ │ sub.w r8, r7, r3 │ │ │ │ - ldr r3, [pc, #400] @ (3cde0 ) │ │ │ │ + ldr r3, [pc, #400] @ (3cd68 ) │ │ │ │ ldr r2, [sp, #32] │ │ │ │ mov r0, r4 │ │ │ │ ldrsh.w r1, [r9, #4] │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldrh r2, [r3, #0] │ │ │ │ ldrsh.w r3, [r9] │ │ │ │ subs r7, r1, r3 │ │ │ │ mov r1, r9 │ │ │ │ add.w fp, r7, #3 │ │ │ │ str r7, [sp, #36] @ 0x24 │ │ │ │ ands.w fp, fp, r7, asr #32 │ │ │ │ it cc │ │ │ │ movcc fp, r7 │ │ │ │ - bl 5b70 │ │ │ │ + bl 5b08 │ │ │ │ ldrsh.w r3, [r9, #4] │ │ │ │ ldrsh.w r2, [r9] │ │ │ │ mov.w sl, fp, asr #2 │ │ │ │ add r3, r7 │ │ │ │ add r3, r8 │ │ │ │ add r2, sl │ │ │ │ cmp r2, r3 │ │ │ │ - bge.w 3c02c │ │ │ │ + bge.w 3bfb4 │ │ │ │ add.w r1, sl, r2 │ │ │ │ mov.w r0, sl, lsl #1 │ │ │ │ sub.w fp, r1, r8 │ │ │ │ ldr r7, [sp, #48] @ 0x30 │ │ │ │ str r5, [sp, #60] @ 0x3c │ │ │ │ mov r5, r0 │ │ │ │ str.w sl, [sp, #40] @ 0x28 │ │ │ │ mov sl, fp │ │ │ │ str r6, [sp, #80] @ 0x50 │ │ │ │ mov r6, r2 │ │ │ │ cmp r6, r1 │ │ │ │ it lt │ │ │ │ sublt.w fp, r6, r8 │ │ │ │ - bge.n 3ccd4 │ │ │ │ + bge.n 3cc5c │ │ │ │ ldrsh.w r2, [r9, #2] │ │ │ │ mov r0, r4 │ │ │ │ ldrh r3, [r7, #0] │ │ │ │ add.w r1, r8, r2 │ │ │ │ str r3, [sp, #4] │ │ │ │ str r1, [sp, #0] │ │ │ │ mov r3, fp │ │ │ │ add.w r1, fp, r8 │ │ │ │ add.w fp, fp, #1 │ │ │ │ - bl 5fe0 │ │ │ │ + bl 5f78 │ │ │ │ cmp fp, sl │ │ │ │ - bne.n 3ccb2 │ │ │ │ + bne.n 3cc3a │ │ │ │ ldrsh.w r3, [r9, #4] │ │ │ │ add r6, r5 │ │ │ │ ldr r2, [sp, #36] @ 0x24 │ │ │ │ add sl, r5 │ │ │ │ add r3, r2 │ │ │ │ add r3, r8 │ │ │ │ cmp r6, r3 │ │ │ │ - bge.n 3ccfa │ │ │ │ + bge.n 3cc82 │ │ │ │ ldr r3, [sp, #40] @ 0x28 │ │ │ │ adds r1, r3, r6 │ │ │ │ - b.n 3cca8 │ │ │ │ - vldr d6, [pc, #168] @ 3cd98 │ │ │ │ + b.n 3cc30 │ │ │ │ + vldr d6, [pc, #168] @ 3cd20 │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ vstr d7, [r3, #48] @ 0x30 │ │ │ │ - b.n 3c8dc │ │ │ │ + b.n 3c864 │ │ │ │ ldr r5, [sp, #60] @ 0x3c │ │ │ │ ldr r6, [sp, #80] @ 0x50 │ │ │ │ - b.w 3c02c │ │ │ │ + b.w 3bfb4 │ │ │ │ add.w r9, sp, #888 @ 0x378 │ │ │ │ - bl 458d8 │ │ │ │ + bl 45860 │ │ │ │ mov r1, r9 │ │ │ │ mov.w sl, #0 │ │ │ │ mov.w fp, #0 │ │ │ │ mov r8, r0 │ │ │ │ strd sl, fp, [sp, #888] @ 0x378 │ │ │ │ strd sl, fp, [sp, #896] @ 0x380 │ │ │ │ strd sl, fp, [sp, #904] @ 0x388 │ │ │ │ - bl 45908 │ │ │ │ + bl 45890 │ │ │ │ add r1, sp, #864 @ 0x360 │ │ │ │ movs r2, #0 │ │ │ │ strd sl, fp, [r1, #8] │ │ │ │ mov r0, r8 │ │ │ │ strd sl, fp, [r1, #16] │ │ │ │ movs r3, #0 │ │ │ │ movt r3, #16368 @ 0x3ff0 │ │ │ │ strd r2, r3, [r1] │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ movs r1, #100 @ 0x64 │ │ │ │ addw r3, sp, #1180 @ 0x49c │ │ │ │ add r2, sp, #840 @ 0x348 │ │ │ │ add r0, sp, #816 @ 0x330 │ │ │ │ str r0, [sp, #40] @ 0x28 │ │ │ │ add r0, sp, #792 @ 0x318 │ │ │ │ str r4, [sp, #72] @ 0x48 │ │ │ │ @@ -65166,21 +65159,21 @@ │ │ │ │ mov r7, r1 │ │ │ │ str.w r9, [sp, #88] @ 0x58 │ │ │ │ add.w fp, sp, #1048 @ 0x418 │ │ │ │ str r6, [sp, #92] @ 0x5c │ │ │ │ add.w sl, sp, #768 @ 0x300 │ │ │ │ ldr r5, [sp, #40] @ 0x28 │ │ │ │ mov r4, r0 │ │ │ │ - vldr d12, [pc, #68] @ 3cdb0 │ │ │ │ + vldr d12, [pc, #68] @ 3cd38 │ │ │ │ mov r9, r3 │ │ │ │ mov r6, r2 │ │ │ │ str r3, [sp, #36] @ 0x24 │ │ │ │ str r2, [sp, #60] @ 0x3c │ │ │ │ str r1, [sp, #80] @ 0x50 │ │ │ │ - b.n 3cee2 │ │ │ │ + b.n 3ce6a │ │ │ │ asrs r3, r7, #17 │ │ │ │ @ instruction: 0x47ae │ │ │ │ ldrb r1, [r4, #11] │ │ │ │ itt hi │ │ │ │ ldrhi r1, [sp, #616] @ 0x268 │ │ │ │ ldrhi r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ @@ -65205,261 +65198,261 @@ │ │ │ │ strle r6, [r4, #100] @ 0x64 │ │ │ │ strgt r6, [r4, #100] @ 0x64 │ │ │ │ subgt r7, #230 @ 0xe6 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ ands r0, r0 │ │ │ │ eors r7, r7 │ │ │ │ - bic.w r0, r4, r0 │ │ │ │ - ldr??.w r0, [r8, r0] │ │ │ │ - push {r4, lr} │ │ │ │ + mrrc 0, 0, r0, r8, cr0 │ │ │ │ + @ instruction: 0xfb9c0000 │ │ │ │ + push {r3, r7, lr} │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - strh.w r0, [r6] │ │ │ │ - strb.w r0, [r4] │ │ │ │ - ldr??.w r0, [r2, r0] │ │ │ │ - strb.w r0, [sl, r0] │ │ │ │ - ldr r6, [pc, #24] @ (3cdf4 ) │ │ │ │ + @ instruction: 0xfaca0000 │ │ │ │ + @ instruction: 0xfaa80000 │ │ │ │ + @ instruction: 0xfa960000 │ │ │ │ + @ instruction: 0xfa2e0000 │ │ │ │ + ldr r5, [pc, #920] @ (3d0fc ) │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r6, #10 │ │ │ │ + lsls r0, r5, #10 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r3, #10 │ │ │ │ + lsls r4, r2, #10 │ │ │ │ movs r0, r0 │ │ │ │ vmov s15, r7 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ - ble.w 3cef4 │ │ │ │ + ble.w 3ce7c │ │ │ │ vsub.f64 d7, d7, d12 │ │ │ │ - vldr d6, [pc, #680] @ 3d0a0 │ │ │ │ + vldr d6, [pc, #680] @ 3d028 │ │ │ │ vmov.f64 d10, #148 @ 0xc0a00000 -5.0 │ │ │ │ vmls.f64 d10, d7, d6 │ │ │ │ - ldr r1, [pc, #756] @ (3d0f8 ) │ │ │ │ + ldr r1, [pc, #756] @ (3d080 ) │ │ │ │ mov r2, r7 │ │ │ │ mov r0, r9 │ │ │ │ - vldr d9, [pc, #672] @ 3d0a8 │ │ │ │ + vldr d9, [pc, #672] @ 3d030 │ │ │ │ add r1, pc │ │ │ │ vmov.f64 d11, #96 @ 0x3f000000 0.5 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ mov r0, r9 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ vmov s15, r0 │ │ │ │ str r0, [sp, #40] @ 0x28 │ │ │ │ mov r0, fp │ │ │ │ vcvt.f64.s32 d14, s15 │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov r0, fp │ │ │ │ - vldr d1, [pc, #636] @ 3d0b0 │ │ │ │ + vldr d1, [pc, #636] @ 3d038 │ │ │ │ vmov.f64 d2, #112 @ 0x3f800000 1.0 │ │ │ │ - bl b180 │ │ │ │ - vldr d1, [pc, #632] @ 3d0b8 │ │ │ │ + bl b284 │ │ │ │ + vldr d1, [pc, #632] @ 3d040 │ │ │ │ vmul.f64 d14, d14, d9 │ │ │ │ - vldr d9, [pc, #632] @ 3d0c0 │ │ │ │ + vldr d9, [pc, #632] @ 3d048 │ │ │ │ mov r0, fp │ │ │ │ - vldr d13, [pc, #636] @ 3d0c8 │ │ │ │ + vldr d13, [pc, #636] @ 3d050 │ │ │ │ vadd.f64 d1, d10, d1 │ │ │ │ vmov.f64 d2, d9 │ │ │ │ vmul.f64 d14, d14, d11 │ │ │ │ vsub.f64 d15, d11, d14 │ │ │ │ vmov.f64 d0, d15 │ │ │ │ - bl b23c │ │ │ │ + bl b338 │ │ │ │ ldr r2, [sp, #40] @ 0x28 │ │ │ │ mov r3, fp │ │ │ │ mov r1, r9 │ │ │ │ mov r0, r8 │ │ │ │ - bl 45c1c │ │ │ │ + bl 45ba4 │ │ │ │ mov r1, r6 │ │ │ │ mov r0, r8 │ │ │ │ vstr d9, [r6] │ │ │ │ vstr d10, [r6, #8] │ │ │ │ vstr d9, [r6, #16] │ │ │ │ - bl 45908 │ │ │ │ + bl 45890 │ │ │ │ vsub.f64 d15, d15, d13 │ │ │ │ mov r1, r5 │ │ │ │ mov r0, r8 │ │ │ │ vstr d10, [r5, #8] │ │ │ │ vstr d9, [r5, #16] │ │ │ │ vstr d15, [r5] │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ movs r2, #0 │ │ │ │ mov r1, r4 │ │ │ │ mov r0, r8 │ │ │ │ movs r3, #0 │ │ │ │ movt r3, #16368 @ 0x3ff0 │ │ │ │ vstr d10, [r4, #8] │ │ │ │ strd r2, r3, [r4] │ │ │ │ vstr d9, [r4, #16] │ │ │ │ - bl 45908 │ │ │ │ + bl 45890 │ │ │ │ vadd.f64 d14, d14, d11 │ │ │ │ mov r1, sl │ │ │ │ mov r0, r8 │ │ │ │ vstr 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r1, r8 │ │ │ │ mov r0, sl │ │ │ │ - bl 45c1c │ │ │ │ + bl 45ba4 │ │ │ │ cmp r6, #30 │ │ │ │ - bne.w 3d28e │ │ │ │ - add r3, pc, #212 @ (adr r3, 3d468 ) │ │ │ │ + bne.w 3d216 │ │ │ │ + add r3, pc, #212 @ (adr r3, 3d3f0 ) │ │ │ │ ldrd r2, r3, [r3] │ │ │ │ vstr d9, [r7, #8] │ │ │ │ mov r1, r7 │ │ │ │ mov r0, sl │ │ │ │ strd r2, r3, [r7] │ │ │ │ vstr d8, [r7, #16] │ │ │ │ ldr r5, [sp, #80] @ 0x50 │ │ │ │ ldr.w r9, [sp, #64] @ 0x40 │ │ │ │ - bl 45908 │ │ │ │ - vldr d9, [pc, #156] @ 3d450 │ │ │ │ + bl 45890 │ │ │ │ + vldr d9, [pc, #156] @ 3d3d8 │ │ │ │ ldr.w r8, [sp, #52] @ 0x34 │ │ │ │ - vldr d5, [pc, #156] @ 3d458 │ │ │ │ - vldr d7, [pc, #160] @ 3d460 │ │ │ │ - vldr d11, [pc, #92] @ 3d420 │ │ │ │ - vldr d10, [pc, #112] @ 3d438 │ │ │ │ - b.n 3d4a6 │ │ │ │ + vldr d5, [pc, #156] @ 3d3e0 │ │ │ │ + vldr d7, [pc, #160] @ 3d3e8 │ │ │ │ + vldr d11, [pc, #92] @ 3d3a8 │ │ │ │ + vldr d10, [pc, #112] @ 3d3c0 │ │ │ │ + b.n 3d42e │ │ │ │ nop │ │ │ │ nop.w │ │ │ │ cmp r5, #24 │ │ │ │ strb r4, [r0, r1] │ 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instruction: 0xeb86b851 │ │ │ │ strh r6, [r3, #40] @ 0x28 │ │ │ │ subs r7, #235 @ 0xeb │ │ │ │ - bge.n 3d458 │ │ │ │ + ble.n 3d458 │ │ │ │ movs r0, r0 │ │ │ │ - sbcs.w r0, r8, #0 │ │ │ │ - bls.n 3d3b4 │ │ │ │ + @ instruction: 0xf39c0000 │ │ │ │ + blt.n 3d3b4 │ │ │ │ movs r0, r0 │ │ │ │ vmov s15, r6 │ │ │ │ - vldr d6, [pc, #748] @ 3d770 │ │ │ │ - vldr d0, [pc, #752] @ 3d778 │ │ │ │ + vldr d6, [pc, #748] @ 3d6f8 │ │ │ │ + vldr d0, [pc, #752] @ 3d700 │ │ │ │ add r7, sp, #96 @ 0x60 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ mov r1, r7 │ │ │ │ add r0, sp, #104 @ 0x68 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ vdiv.f64 d0, d7, d0 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ vldr d7, [sp, #96] @ 0x60 │ │ │ │ vldr d5, [r8, #-8] │ │ │ │ vmov.f64 d6, d11 │ │ │ │ - vldr d8, [pc, #724] @ 3d780 │ │ │ │ + vldr d8, [pc, #724] @ 3d708 │ │ │ │ vmla.f64 d6, d7, d9 │ │ │ │ vmov.f64 d7, d10 │ │ │ │ vmla.f64 d7, d5, d9 │ │ │ │ mov r1, r4 │ │ │ │ mov r0, sl │ │ │ │ adds r6, #30 │ │ │ │ vstr d8, [r4, #16] │ │ │ │ vstr d6, [r4] │ │ │ │ vstr d7, [r4, #8] │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ cmp.w r6, #390 @ 0x186 │ │ │ │ - bne.n 3d47c │ │ │ │ - ldr r7, [pc, #720] @ (3d7a8 ) │ │ │ │ - vldr d10, [pc, #684] @ 3d788 │ │ │ │ + bne.n 3d404 │ │ │ │ + ldr r7, [pc, #720] @ (3d730 ) │ │ │ │ + vldr d10, [pc, #684] @ 3d710 │ │ │ │ add r7, pc │ │ │ │ - vldr d11, [pc, #688] @ 3d790 │ │ │ │ + vldr d11, [pc, #688] @ 3d718 │ │ │ │ str.w sl, [r7] │ │ │ │ - bl 458d8 │ │ │ │ + bl 45860 │ │ │ │ mov r1, r4 │ │ │ │ vstr d8, [r4, #8] │ │ │ │ vstr d8, [r4, #16] │ │ │ │ mov r6, r0 │ │ │ │ vstr d10, [r4] │ │ │ │ - bl 45908 │ │ │ │ + bl 45890 │ │ │ │ add r1, sp, #600 @ 0x258 │ │ │ │ mov r0, r6 │ │ │ │ vstr d8, [r1] │ │ │ │ vstr d10, [r1, #8] │ │ │ │ vstr d8, [r1, #16] │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ add r1, sp, #576 @ 0x240 │ │ │ │ mov r0, r6 │ │ │ │ - add r3, pc, #640 @ (adr r3, 3d798 ) │ │ │ │ + add r3, pc, #640 @ (adr r3, 3d720 ) │ │ │ │ ldrd r2, r3, [r3] │ │ │ │ vstr d8, [r1, #8] │ │ │ │ strd r2, r3, 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(adr r7, 3dea0 ) │ │ │ │ movs r1, r0 │ │ │ │ - lsrs r6, r0 │ │ │ │ + lsls r6, r4 │ │ │ │ movs r2, r0 │ │ │ │ - lsls r0, r3, #12 │ │ │ │ + lsls r0, r2, #12 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r5, #12 │ │ │ │ + lsls r4, r4, #12 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r7, #9 │ │ │ │ + lsls r4, r6, #9 │ │ │ │ movs r0, r0 │ │ │ │ - @ instruction: 0xe9b80000 │ │ │ │ - @ instruction: 0xe9be0000 │ │ │ │ - vldr d7, [pc, #12] @ 3db50 │ │ │ │ + rsbs r0, ip, r0 │ │ │ │ + @ instruction: 0xebe20000 │ │ │ │ + vldr d7, [pc, #12] @ 3dad8 │ │ │ │ vmov.f64 d0, d7 │ │ │ │ vstr d7, [r0, #752] @ 0x2f0 │ │ │ │ bx lr │ │ │ │ nop │ │ │ │ ... │ │ │ │ push {r3, r4, r5, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d9} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4064] @ 0xfe0 │ │ │ │ vldr d7, [r0, #760] @ 0x2f8 │ │ │ │ mov r4, r0 │ │ │ │ - ldr r2, [pc, #140] @ (3dc00 ) │ │ │ │ + ldr r2, [pc, #140] @ (3db88 ) │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ add r2, pc │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.n 3dbf0 │ │ │ │ + ble.n 3db78 │ │ │ │ ldr.w r1, [r0, #640] @ 0x280 │ │ │ │ vmov d8, r1, r1 │ │ │ │ vcvt.f64.s32 d8, d8, #15 │ │ │ │ - ldr r3, [pc, #120] @ (3dc04 ) │ │ │ │ + ldr r3, [pc, #120] @ (3db8c ) │ │ │ │ str.w r1, [r4, #748] @ 0x2ec │ │ │ │ ldr.w r5, [r4, #812] @ 0x32c │ │ │ │ vldr d9, [r4, #752] @ 0x2f0 │ │ │ │ ldr r3, [r2, r3] │ │ │ │ vldr d7, [r5, #512] @ 0x200 │ │ │ │ vsub.f64 d9, d9, d8 │ │ │ │ vldr d0, [r3] │ │ │ │ vdiv.f64 d0, d0, d7 │ │ │ │ - blx 2f5c │ │ │ │ + blx 2f0c │ │ │ │ vmla.f64 d8, d9, d0 │ │ │ │ vcmpe.f64 d8, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.n 3dbe6 │ │ │ │ + bmi.n 3db6e │ │ │ │ vmov.f64 d6, #112 @ 0x3f800000 1.0 │ │ │ │ vcmpe.f64 d8, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.n 3dbe0 │ │ │ │ + ble.n 3db68 │ │ │ │ vmov.f64 d8, d6 │ │ │ │ vldr d0, [r5, #480] @ 0x1e0 │ │ │ │ vstr d6, [r4, #752] @ 0x2f0 │ │ │ │ vmul.f64 d0, d8, d0 │ │ │ │ vpop {d8-d9} │ │ │ │ pop {r3, r4, r5, pc} │ │ │ │ vmov.f64 d6, d8 │ │ │ │ - b.n 3dbce │ │ │ │ - vldr d6, [pc, #16] @ 3dbf8 │ │ │ │ + b.n 3db56 │ │ │ │ + vldr d6, [pc, #16] @ 3db80 │ │ │ │ vmov.f64 d8, d6 │ │ │ │ - b.n 3dbce │ │ │ │ - vldr d8, [pc, #4] @ 3dbf8 │ │ │ │ + b.n 3db56 │ │ │ │ + vldr d8, [pc, #4] @ 3db80 │ │ │ │ movs r1, #0 │ │ │ │ - b.n 3db8a │ │ │ │ + b.n 3db12 │ │ │ │ ... │ │ │ │ - add r4, pc, #536 @ (adr r4, 3de1c ) │ │ │ │ + add r4, pc, #1016 @ (adr r4, 3df84 ) │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ push {r3, r4, r5, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d10} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4056] @ 0xfd8 │ │ │ │ ldr r2, [r0, #12] │ │ │ │ mov r4, r0 │ │ │ │ - ldr r5, [pc, #192] @ (3dce0 ) │ │ │ │ + ldr r5, [pc, #192] @ (3dc68 ) │ │ │ │ ldr.w r3, [r0, #812] @ 0x32c │ │ │ │ add r5, pc │ │ │ │ vldr d0, [r0, #320] @ 0x140 │ │ │ │ lsls r2, r2, #30 │ │ │ │ - bpl.n 3dca2 │ │ │ │ + bpl.n 3dc2a │ │ │ │ ldr.w r0, [r3, #500] @ 0x1f4 │ │ │ │ - bl 35ccc │ │ │ │ + bl 35c54 │ │ │ │ vldr d7, [r4, #760] @ 0x2f8 │ │ │ │ ldr.w r2, [r4, #812] @ 0x32c │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vldr d8, [r2, #488] @ 0x1e8 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ vmul.f64 d8, d0, d8 │ │ │ │ - ble.n 3dcc4 │ │ │ │ + ble.n 3dc4c │ │ │ │ ldr.w r1, [r4, #640] @ 0x280 │ │ │ │ vmov d9, r1, r1 │ │ │ │ vcvt.f64.s32 d9, d9, #15 │ │ │ │ - ldr r3, [pc, #132] @ (3dce4 ) │ │ │ │ + ldr r3, [pc, #132] @ (3dc6c ) │ │ │ │ str.w r1, [r4, #748] @ 0x2ec │ │ │ │ vldr d10, [r4, #752] @ 0x2f0 │ │ │ │ vldr d7, [r2, #512] @ 0x200 │ │ │ │ ldr r3, [r5, r3] │ │ │ │ vsub.f64 d10, d10, d9 │ │ │ │ vldr d0, [r3] │ │ │ │ vdiv.f64 d0, d0, d7 │ │ │ │ - blx 2f5c │ │ │ │ + blx 2f0c │ │ │ │ vmla.f64 d9, d10, d0 │ │ │ │ vldr d5, [r4, #288] @ 0x120 │ │ │ │ - vldr d6, [pc, #72] @ 3dcd0 │ │ │ │ + vldr d6, [pc, #72] @ 3dc58 │ │ │ │ vmul.f64 d8, d9, d8 │ │ │ │ vstr d9, [r4, #752] @ 0x2f0 │ │ │ │ vmul.f64 d8, d8, d9 │ │ │ │ vmul.f64 d8, d8, d5 │ │ │ │ vdiv.f64 d0, d8, d6 │ │ │ │ vpop {d8-d10} │ │ │ │ pop {r3, r4, r5, pc} │ │ │ │ ldr.w r0, [r3, #496] @ 0x1f0 │ │ │ │ - bl 35ccc │ │ │ │ + bl 35c54 │ │ │ │ vldr d7, [r4, #760] @ 0x2f8 │ │ │ │ ldr.w r2, [r4, #812] @ 0x32c │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vldr d8, [r2, #480] @ 0x1e0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ vmul.f64 d8, d0, d8 │ │ │ │ - bgt.n 3dc50 │ │ │ │ - vldr d9, [pc, #16] @ 3dcd8 │ │ │ │ + bgt.n 3dbd8 │ │ │ │ + vldr d9, [pc, #16] @ 3dc60 │ │ │ │ movs r1, #0 │ │ │ │ - b.n 3dc5c │ │ │ │ + b.n 3dbe4 │ │ │ │ nop.w │ │ │ │ rsbs r8, sp, #16908288 @ 0x1020000 │ │ │ │ ldrb r0, [r7, #2] │ │ │ │ subs r7, #99 @ 0x63 │ │ │ │ ... │ │ │ │ - add r3, pc, #864 @ (adr r3, 3e044 ) │ │ │ │ + add r4, pc, #320 @ (adr r4, 3ddac ) │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ push {r3, r4, r5, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d9} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4064] @ 0xfe0 │ │ │ │ vldr d7, [r0, #760] @ 0x2f8 │ │ │ │ mov r4, r0 │ │ │ │ - ldr r2, [pc, #164] @ (3dda8 ) │ │ │ │ + ldr r2, [pc, #164] @ (3dd30 ) │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ add r2, pc │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - ble.n 3dd84 │ │ │ │ + ble.n 3dd0c │ │ │ │ ldr.w r1, [r0, #640] @ 0x280 │ │ │ │ vmov d8, r1, r1 │ │ │ │ vcvt.f64.s32 d8, d8, #15 │ │ │ │ - ldr r3, [pc, #144] @ (3ddac ) │ │ │ │ + ldr r3, [pc, #144] @ (3dd34 ) │ │ │ │ str.w r1, [r4, #748] @ 0x2ec │ │ │ │ ldr.w r5, [r4, #812] @ 0x32c │ │ │ │ vldr d9, [r4, #752] @ 0x2f0 │ │ │ │ ldr r3, [r2, r3] │ │ │ │ vldr d7, [r5, #512] @ 0x200 │ │ │ │ vsub.f64 d9, d9, d8 │ │ │ │ vldr d0, [r3] │ │ │ │ vdiv.f64 d0, d0, d7 │ │ │ │ - blx 2f5c │ │ │ │ + blx 2f0c │ │ │ │ vmov.f64 d7, d0 │ │ │ │ ldr.w r0, [r5, #496] @ 0x1f0 │ │ │ │ vldr d0, [r4, #320] @ 0x140 │ │ │ │ vmla.f64 d8, d9, d7 │ │ │ │ vstr d8, [r4, #752] @ 0x2f0 │ │ │ │ - bl 35ccc │ │ │ │ + bl 35c54 │ │ │ │ ldr.w r3, [r4, #812] @ 0x32c │ │ │ │ vmul.f64 d8, d8, d0 │ │ │ │ vldr d5, [r4, #288] @ 0x120 │ │ │ │ - vldr d6, [pc, #44] @ 3dd90 │ │ │ │ - vldr d1, [pc, #48] @ 3dd98 │ │ │ │ + vldr d6, [pc, #44] @ 3dd18 │ │ │ │ + vldr d1, [pc, #48] @ 3dd20 │ │ │ │ vldr d7, [r3, #480] @ 0x1e0 │ │ │ │ vdiv.f64 d0, d5, d6 │ │ │ │ vmul.f64 d8, d8, d7 │ │ │ │ - blx 356c │ │ │ │ + blx 3508 │ │ │ │ vmul.f64 d0, d8, d0 │ │ │ │ vpop {d8-d9} │ │ │ │ pop {r3, r4, r5, pc} │ │ │ │ - vldr d8, [pc, #24] @ 3dda0 │ │ │ │ + vldr d8, [pc, #24] @ 3dd28 │ │ │ │ movs r1, #0 │ │ │ │ - b.n 3dd1a │ │ │ │ + b.n 3dca2 │ │ │ │ nop.w │ │ │ │ rsbs r8, sp, #16908288 @ 0x1020000 │ │ │ │ ldrb r0, [r7, #2] │ │ │ │ subs r7, #99 @ 0x63 │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #249 @ 0xf9 │ │ │ │ ... │ │ │ │ - add r2, pc, #984 @ (adr r2, 3e184 ) │ │ │ │ + add r3, pc, #440 @ (adr r3, 3deec ) │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ push {r3, r4, r5, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4072] @ 0xfe8 │ │ │ │ - ldr r3, [pc, #104] @ (3de2c ) │ │ │ │ + ldr r3, [pc, #104] @ (3ddb4 ) │ │ │ │ vmov.f64 d8, #20 @ 0x40a00000 5.0 │ │ │ │ - ldr r2, [pc, #100] @ (3de30 ) │ │ │ │ + ldr r2, [pc, #100] @ (3ddb8 ) │ │ │ │ add r3, pc │ │ │ │ ldr r4, [r3, r2] │ │ │ │ add.w r5, r4, #141312 @ 0x22800 │ │ │ │ - b.n 3dddc │ │ │ │ + b.n 3dd64 │ │ │ │ add.w r4, r4, #4416 @ 0x1140 │ │ │ │ cmp r4, r5 │ │ │ │ - beq.n 3de12 │ │ │ │ + beq.n 3dd9a │ │ │ │ ldr r3, [r4, #16] │ │ │ │ cmp r3, #1 │ │ │ │ - bne.n 3ddd4 │ │ │ │ + bne.n 3dd5c │ │ │ │ add.w r0, r4, #200 @ 0xc8 │ │ │ │ - bl ab5c │ │ │ │ + bl aa78 │ │ │ │ vcmpe.f64 d0, d8 │ │ │ │ mov r0, r4 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.n 3ddd4 │ │ │ │ + bpl.n 3dd5c │ │ │ │ ldr.w r3, [r4, #812] @ 0x32c │ │ │ │ ldr.w r3, [r3, #1356] @ 0x54c │ │ │ │ blx r3 │ │ │ │ ldr.w r1, [r4, #3972] @ 0xf84 │ │ │ │ mov r0, r4 │ │ │ │ add.w r4, r4, #4416 @ 0x1140 │ │ │ │ - bl 469e0 │ │ │ │ + bl 46968 │ │ │ │ cmp r4, r5 │ │ │ │ - bne.n 3dddc │ │ │ │ + bne.n 3dd64 │ │ │ │ vpop {d8} │ │ │ │ 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(3de68 ) │ │ │ │ tst.w r4, #2 │ │ │ │ - ldr r2, [pc, #60] @ (3dee4 ) │ │ │ │ + ldr r2, [pc, #60] @ (3de6c ) │ │ │ │ vldr d4, [r1, #520] @ 0x208 │ │ │ │ add r3, pc │ │ │ │ vldr d7, [r1, #528] @ 0x210 │ │ │ │ vldr d5, [r0, #688] @ 0x2b0 │ │ │ │ ldr r3, [r3, r2] │ │ │ │ it eq │ │ │ │ vmoveq.f64 d7, d4 │ │ │ │ - vldr d0, [pc, #24] @ 3ded8 │ │ │ │ + vldr d0, [pc, #24] @ 3de60 │ │ │ │ ldr.w r4, [sp], #4 │ │ │ │ vldr d6, [r3] │ │ │ │ vmul.f64 d7, d7, d5 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ vdiv.f64 d0, d7, d0 │ │ │ │ bx lr │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, #0 │ │ │ │ lsls r4, r5 │ │ │ │ - add r1, pc, #320 @ (adr r1, 3e024 ) │ │ │ │ + add r1, pc, #800 @ (adr r1, 3e18c ) │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ ldr r3, [r0, #16] │ │ │ │ push {r4, r5, r6, r7, lr} │ │ │ │ mov r7, r0 │ │ │ │ ldr.w r4, [r0, #812] @ 0x32c │ │ │ │ cmp r3, #6 │ │ │ │ - bne.n 3df06 │ │ │ │ + bne.n 3de8e │ │ │ │ vldr d7, [r4, #464] @ 0x1d0 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0x2f0 │ │ │ │ strd r6, r7, [r4, #720] @ 0x2d0 │ │ │ │ strd r6, r7, [r4, #728] @ 0x2d8 │ │ │ │ strd r6, r7, [r4, #736] @ 0x2e0 │ │ │ │ strd r6, r7, [r4, #488] @ 0x1e8 │ │ │ │ strd r6, r7, [r4, #480] @ 0x1e0 │ │ │ │ strd r6, r7, [r4, #472] @ 0x1d8 │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ mov r0, r4 │ │ │ │ movw r3, #65535 @ 0xffff │ │ │ │ str.w r8, [r4, #12] │ │ │ │ strh.w r3, [r4, #824] @ 0x338 │ │ │ │ - bl 3fee8 │ │ │ │ + bl 3fe70 │ │ │ │ add.w r3, r4, #4288 @ 0x10c0 │ │ │ │ mov r0, r4 │ │ │ │ str.w r8, [r4, #808] @ 0x328 │ │ │ │ strd r6, r7, [r3, #16] │ │ │ │ strd r6, r7, [r3, #8] │ │ │ │ add.w r3, r4, #4320 @ 0x10e0 │ │ │ │ strd r6, r7, [r3, #16] │ │ │ │ strd r6, r7, [r3, #24] │ │ │ │ movw r3, #4356 @ 0x1104 │ │ │ │ str.w r8, [r4, r3] │ │ │ │ movw r3, #4268 @ 0x10ac │ │ │ │ str.w r8, [r4, r3] │ │ │ │ - bl 2d3f0 │ │ │ │ + bl 2d378 │ │ │ │ mov r0, r4 │ │ │ │ - bl 2d568 │ │ │ │ + bl 2d4f0 │ │ │ │ ldr.w r3, [r4, #812] @ 0x32c │ │ │ │ mov r0, r4 │ │ │ │ ldr.w r3, [r3, #1356] @ 0x54c │ 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sp, sp, #1048 @ 0x418 │ │ │ │ add r7, pc │ │ │ │ add r4, sp, #16 │ │ │ │ - ldr r6, [pc, #356] @ (3e25c ) │ │ │ │ + ldr r6, [pc, #356] @ (3e1e4 ) │ │ │ │ movs r3, #0 │ │ │ │ movs r2, #0 │ │ │ │ ldr r0, [r7, r0] │ │ │ │ add r6, pc │ │ │ │ ldr r0, [r0, #0] │ │ │ │ str.w r0, [sp, #1044] @ 0x414 │ │ │ │ mov.w r0, #0 │ │ │ │ strd r2, r3, [r4] │ │ │ │ strd r2, r3, [r4, #8] │ │ │ │ strd r2, r3, [r4, #16] │ │ │ │ ldr r3, [r5, #16] │ │ │ │ cmp r1, #0 │ │ │ │ - beq.n 3e21c │ │ │ │ + beq.n 3e1a4 │ │ │ │ cmp r3, #8 │ │ │ │ - bhi.n 3e162 │ │ │ │ + bhi.n 3e0ea │ │ │ │ mov.w r2, #322 @ 0x142 │ │ │ │ lsrs r2, r3 │ │ │ │ lsls r0, r2, #31 │ │ │ │ - bpl.n 3e21c │ │ │ │ + bpl.n 3e1a4 │ │ │ │ ldr.w r3, [r5, #812] @ 0x32c │ │ │ │ mov r7, r1 │ │ │ │ ldr r0, [r5, #52] @ 0x34 │ │ │ │ ldr.w r8, [r3, #12] │ │ │ │ - bl bba8 │ │ │ │ - ldr r2, [pc, #292] @ (3e260 ) │ │ │ │ + bl c318 │ │ │ │ + ldr r2, [pc, #292] @ (3e1e8 ) │ │ │ │ add.w r3, r5, #20 │ │ │ │ strd r0, r7, [sp, #4] │ │ │ │ add r7, sp, #44 @ 0x2c │ │ │ │ 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#180] @ (3e3a0 ) │ │ │ │ ldr r3, [sp, #24] │ │ │ │ add r4, pc │ │ │ │ str r4, [r3, #0] │ │ │ │ ldr r7, [r4, #4] │ │ │ │ cmp r7, #0 │ │ │ │ - beq.w 3e9ca │ │ │ │ + beq.w 3e952 │ │ │ │ adds r4, #8 │ │ │ │ - b.n 3e380 │ │ │ │ + b.n 3e308 │ │ │ │ str.w r4, [r9] │ │ │ │ adds r4, #8 │ │ │ │ ldr.w r7, [r4, #-4] │ │ │ │ - cbz r7, 3e3c4 │ │ │ │ + cbz r7, 3e34c │ │ │ │ ldr.w r0, [r4, #-8] │ │ │ │ mov r1, r5 │ │ │ │ - blx 3590 │ │ │ │ + blx 352c │ │ │ │ cmp r0, #0 │ │ │ │ - bne.n 3e374 │ │ │ │ + bne.n 3e2fc │ │ │ │ subs r2, r7, #2 │ │ │ │ cmp r2, #20 │ │ │ │ - bhi.w 3ec94 │ │ │ │ + bhi.w 3ec1c │ │ │ │ tbh [pc, r2, lsl #1] │ │ │ │ lsls r5, r7, #16 │ │ │ │ lsls r5, r7, #17 │ │ │ │ lsls r0, r1, #17 │ │ │ │ lsls r5, r7, #17 │ │ │ │ lsls r7, r0, #12 │ │ │ │ lsls r5, r7, #17 │ │ │ │ @@ -67111,69 +67102,69 @@ │ │ │ │ lsls r7, r1, #14 │ │ │ │ lsls r3, r3, #14 │ │ │ │ lsls r6, r6, #14 │ │ │ │ lsls r0, r0, #15 │ │ │ │ lsls r2, r1, #15 │ │ │ │ lsls r3, r5, #16 │ │ │ │ mov fp, r5 │ │ │ │ - ldr r0, [pc, #84] @ (3e41c ) │ │ │ │ + ldr r0, [pc, #84] @ (3e3a4 ) │ │ │ │ mov r1, fp │ │ │ │ add r0, pc │ │ │ │ - bl 128b8 │ │ │ │ + bl 13028 │ │ │ │ mov.w r0, #4294967295 @ 0xffffffff │ │ │ │ - ldr r2, [pc, #72] @ (3e420 ) │ │ │ │ - ldr r3, [pc, #48] @ (3e408 ) │ │ │ │ + ldr r2, [pc, #72] @ (3e3a8 ) │ │ │ │ + ldr r3, [pc, #48] @ (3e390 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #380] @ 0x17c │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.w 3ed62 │ │ │ │ + bne.w 3ecea │ │ │ │ add sp, #388 @ 0x184 │ │ │ │ vpop {d8-d12} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ nop.w │ │ │ │ ... │ │ │ │ - ldr r5, [sp, #96] @ 0x60 │ │ │ │ + ldr r5, [sp, #576] @ 0x240 │ │ │ │ movs r1, r0 │ │ │ │ - ldr r5, [sp, #80] @ 0x50 │ │ │ │ + ldr r5, [sp, #560] @ 0x230 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - b.n 3e880 │ │ │ │ + b.n 3dc50 │ │ │ │ movs r0, r0 │ │ │ │ - adds r7, #6 │ │ │ │ + adds r6, #230 @ 0xe6 │ │ │ │ movs r2, r0 │ │ │ │ - adds r7, #4 │ │ │ │ + adds r6, #228 @ 0xe4 │ │ │ │ movs r2, r0 │ │ │ │ - ldmia r4!, {r7} │ │ │ │ + ldmia r4!, {r5, r6} │ │ │ │ movs r1, r0 │ │ │ │ - b.n 3e8b4 │ │ │ │ + b.n 3dc84 │ │ │ │ movs r0, r0 │ │ │ │ - ldr r4, [sp, #144] @ 0x90 │ │ │ │ + ldr r4, [sp, #624] @ 0x270 │ │ │ │ movs r1, r0 │ │ │ │ ldr.w r8, [sp, #60] @ 0x3c │ │ │ │ ldr r0, [sp, #52] @ 0x34 │ │ │ │ - bl 3df40 │ │ │ │ + bl 3dec8 │ │ │ │ subs r6, r0, #0 │ │ │ │ - blt.w 3ed26 │ │ │ │ - ldr r3, [pc, #808] @ (3e760 ) │ │ │ │ + blt.w 3ecae │ │ │ │ + ldr r3, [pc, #808] @ (3e6e8 ) │ │ │ │ mov.w r5, #4416 @ 0x1140 │ │ │ │ mul.w r5, r6, r5 │ │ │ │ ldr.w r4, [r8, r3] │ │ │ │ ldr r3, [sp, #240] @ 0xf0 │ │ │ │ add.w r9, r4, r5 │ │ │ │ ldr.w r2, [r9, #812] @ 0x32c │ │ │ │ vldr d7, [r2, #464] @ 0x1d0 │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 3e80c │ │ │ │ + bne.w 3e794 │ │ │ │ ldr r3, [sp, #244] @ 0xf4 │ │ │ │ add.w r1, r5, #264 @ 0x108 │ │ │ │ - vldr d6, [pc, #744] @ 3e748 │ │ │ │ + vldr d6, [pc, #744] @ 3e6d0 │ │ │ │ movs r0, #0 │ │ │ │ cmp r3, #0 │ │ │ │ mov.w r3, #4416 @ 0x1140 │ │ │ │ ldr r2, [sp, #212] @ 0xd4 │ │ │ │ add r1, r4 │ │ │ │ str r1, [sp, #24] │ │ │ │ mov.w r1, #0 │ │ │ │ @@ -67182,89 +67173,89 @@ │ │ │ │ vmoveq.f64 d8, d6 │ │ │ │ strd r0, r1, [r3, #264] @ 0x108 │ │ │ │ strd r0, r1, [r3, #272] @ 0x110 │ │ │ │ strd r0, r1, [r3, #280] @ 0x118 │ │ │ │ vstr d7, [r3, #760] @ 0x2f8 │ │ │ │ vstr d8, [r3, #768] @ 0x300 │ │ │ │ cmp r2, #0 │ │ │ │ - bne.w 3e900 │ │ │ │ + bne.w 3e888 │ │ │ │ ldr r3, [sp, #216] @ 0xd8 │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 3e8e2 │ │ │ │ + bne.w 3e86a │ │ │ │ mov.w r7, #4416 @ 0x1140 │ │ │ │ ldr.w fp, [sp, #24] │ │ │ │ add.w sl, r5, #240 @ 0xf0 │ │ │ │ movs r2, #0 │ │ │ │ add sl, r4 │ │ │ │ mov r0, fp │ │ │ │ mla r7, r7, r6, r4 │ │ │ │ mov r1, sl │ │ │ │ movs r3, #0 │ │ │ │ strd r2, r3, [r7, #336] @ 0x150 │ │ │ │ - bl f320 │ │ │ │ - ldr r3, [pc, #672] @ (3e764 ) │ │ │ │ + bl fa90 │ │ │ │ + ldr r3, [pc, #672] @ (3e6ec ) │ │ │ │ movs r2, #0 │ │ │ │ mov r1, fp │ │ │ │ ldr.w r3, [r8, r3] │ │ │ │ ldr r0, [r3, #0] │ │ │ │ movs r3, #1 │ │ │ │ - bl 48db0 │ │ │ │ + bl 48d38 │ │ │ │ str r0, [r7, #64] @ 0x40 │ │ │ │ - cbz r0, 3e4e0 │ │ │ │ - bl 47eb8 │ │ │ │ + cbz r0, 3e468 │ │ │ │ + bl 47e40 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 3e978 │ │ │ │ + bne.w 3e900 │ │ │ │ ldr r3, [sp, #220] @ 0xdc │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 3e81e │ │ │ │ + bne.w 3e7a6 │ │ │ │ add.w r2, r5, #480 @ 0x1e0 │ │ │ │ add r7, sp, #80 @ 0x50 │ │ │ │ add r2, r4 │ │ │ │ mov r1, r7 │ │ │ │ mov r0, r9 │ │ │ │ - bl 2d730 │ │ │ │ + bl 2d6b8 │ │ │ │ mov r0, r9 │ │ │ │ - bl 45178 │ │ │ │ + bl 45100 │ │ │ │ vldr d6, [sp, #80] @ 0x50 │ │ │ │ - vldr d7, [pc, #588] @ 3e750 │ │ │ │ + vldr d7, [pc, #588] @ 3e6d8 │ │ │ │ mov.w r3, #4416 @ 0x1140 │ │ │ │ ldr r0, [sp, #24] │ │ │ │ mov r1, sl │ │ │ │ vmla.f64 d0, d6, d7 │ │ │ │ mla r3, r3, r6, r4 │ │ │ │ vstr d0, [r3, #280] @ 0x118 │ │ │ │ - bl f320 │ │ │ │ + bl fa90 │ │ │ │ mov r0, r9 │ │ │ │ - bl 2d568 │ │ │ │ - ldr r3, [pc, #576] @ (3e768 ) │ │ │ │ + bl 2d4f0 │ │ │ │ + ldr r3, [pc, #576] @ (3e6f0 ) │ │ │ │ mov.w r7, #4416 @ 0x1140 │ │ │ │ vmov.f64 d6, #112 @ 0x3f800000 1.0 │ │ │ │ mov r0, r9 │ │ │ │ mla r7, r7, r6, r4 │ │ │ │ ldr.w sl, [r8, r3] │ │ │ │ add.w r3, r7, #4288 @ 0x10c0 │ │ │ │ vldr d7, [sl] │ │ │ │ vsub.f64 d7, d7, d6 │ │ │ │ vstr d7, [r3, #16] │ │ │ │ - bl 40008 │ │ │ │ + bl 3ff90 │ │ │ │ vldr d7, [sl] │ │ │ │ add.w r3, r7, #4288 @ 0x10c0 │ │ │ │ vmov.f64 d6, #0 @ 0x40000000 2.0 │ │ │ │ - vldr d2, [pc, #508] @ 3e758 │ │ │ │ + vldr d2, [pc, #508] @ 3e6e0 │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ vldr d0, [r3, #8] │ │ │ │ add.w r3, r7, #4320 @ 0x10e0 │ │ │ │ vstr d2, [r7, #472] @ 0x1d8 │ │ │ │ vstr d0, [r3, #16] │ │ │ │ vstr d7, [r3, #24] │ │ │ │ ldr r3, [sp, #228] @ 0xe4 │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 3e8d0 │ │ │ │ + bne.w 3e858 │ │ │ │ mov.w r7, #4416 @ 0x1140 │ │ │ │ - vldr d8, [pc, #468] @ 3e758 │ │ │ │ + vldr d8, [pc, #468] @ 3e6e0 │ │ │ │ add.w sl, r5, #72 @ 0x48 │ │ │ │ mla r7, r7, r6, r4 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ add.w lr, r7, #240 @ 0xf0 │ │ │ │ add.w ip, r7, #584 @ 0x248 │ │ │ │ vldr d1, [r7, #480] @ 0x1e0 │ │ │ │ ldmia.w lr!, {r0, r1, r2, r3} │ │ │ │ @@ -67272,183 +67263,183 @@ │ │ │ │ vstr d8, [r7, #488] @ 0x1e8 │ │ │ │ vstr d8, [r7, #496] @ 0x1f0 │ │ │ │ vstr d8, [r7, #504] @ 0x1f8 │ │ │ │ ldmia.w lr, {r0, r1} │ │ │ │ stmia.w ip, {r0, r1} │ │ │ │ add.w r0, r4, sl │ │ │ │ vstr d8, [r7, #512] @ 0x200 │ │ │ │ - bl b42c │ │ │ │ + bl b748 │ │ │ │ add.w r1, r5, #344 @ 0x158 │ │ │ │ ldr r0, [sp, #24] │ │ │ │ add r1, r4 │ │ │ │ - bl fbb0 │ │ │ │ + bl 10320 │ │ │ │ ldr r3, [sp, #224] @ 0xe0 │ │ │ │ add.w r2, r5, #200 @ 0xc8 │ │ │ │ add r2, r4 │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 3e890 │ │ │ │ + beq.w 3e818 │ │ │ │ add.w sl, sp, #248 @ 0xf8 │ │ │ │ str r2, [sp, #52] @ 0x34 │ │ │ │ mov r0, sl │ │ │ │ add.w fp, sp, #80 @ 0x50 │ │ │ │ vstr d9, [sp, #80] @ 0x50 │ │ │ │ vstr d8, [sp, #88] @ 0x58 │ │ │ │ vstr d8, [sp, #96] @ 0x60 │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ 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#4] │ │ │ │ strgt r3, [sp, #68] @ 0x44 │ │ │ │ movgt r3, #1 │ │ │ │ strgt r3, [sp, #216] @ 0xd8 │ │ │ │ ldr r2, [r2, #4] │ │ │ │ cmp r2, #0 │ │ │ │ - bne.w 3e34c │ │ │ │ - b.n 3e9ca │ │ │ │ - ldr r2, [pc, #308] @ (3ebd8 ) │ │ │ │ + bne.w 3e2d4 │ │ │ │ + b.n 3e952 │ │ │ │ + ldr r2, [pc, #308] @ (3eb60 ) │ │ │ │ adds r6, #1 │ │ │ │ cmp sl, r6 │ │ │ │ add r2, pc │ │ │ │ ldr r4, [r2, #0] │ │ │ │ - bgt.w 3ece8 │ │ │ │ + bgt.w 3ec70 │ │ │ │ ldr r2, [r4, #4] │ │ │ │ cmp r2, #0 │ │ │ │ - bne.w 3e34c │ │ │ │ - b.n 3e9ca │ │ │ │ + bne.w 3e2d4 │ │ │ │ + b.n 3e952 │ │ │ │ adds r6, #1 │ │ │ │ cmp sl, r6 │ │ │ │ - bgt.w 3ecaa │ │ │ │ - ldr r3, [pc, #280] @ (3ebdc ) │ │ │ │ + bgt.w 3ec32 │ │ │ │ + ldr r3, [pc, #280] @ (3eb64 ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #0] │ │ │ │ ldr r2, [r3, #4] │ │ │ │ cmp r2, #0 │ │ │ │ - bne.w 3e34c │ │ │ │ - b.n 3e9ca │ │ │ │ - ldr r2, [pc, #268] @ (3ebe0 ) │ │ │ │ + bne.w 3e2d4 │ │ │ │ + b.n 3e952 │ │ │ │ + ldr r2, [pc, #268] @ (3eb68 ) │ │ │ │ adds r6, #1 │ │ │ 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r4, r4, #11 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r7, #11 │ │ │ │ + lsls r0, r6, #11 │ │ │ │ movs r0, r0 │ │ │ │ - adds r0, #118 @ 0x76 │ │ │ │ + adds r0, #86 @ 0x56 │ │ │ │ movs r2, r0 │ │ │ │ - adds r0, #94 @ 0x5e │ │ │ │ + adds r0, #62 @ 0x3e │ │ │ │ movs r2, r0 │ │ │ │ - blt.n 3eb50 │ │ │ │ + ble.n 3eb20 │ │ │ │ movs r0, r0 │ │ │ │ - blt.n 3eb98 │ │ │ │ + udf #16 │ │ │ │ movs r0, r0 │ │ │ │ - blt.n 3eb60 │ │ │ │ + ble.n 3eb30 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r4, #10 │ │ │ │ + lsls r0, r3, #10 │ │ │ │ movs r0, r0 │ │ │ │ - adds r0, #0 │ │ │ │ + cmp r7, #224 @ 0xe0 │ │ │ │ movs r2, r0 │ │ │ │ - cmp r7, #236 @ 0xec │ │ │ │ + cmp r7, #204 @ 0xcc │ │ │ │ movs r2, r0 │ │ │ │ - cmp r7, #212 @ 0xd4 │ │ │ │ + cmp r7, #180 @ 0xb4 │ │ │ │ movs r2, r0 │ │ │ │ - cmp r7, #178 @ 0xb2 │ │ │ │ + cmp r7, #146 @ 0x92 │ │ │ │ movs r2, r0 │ │ │ │ - cmp r7, #142 @ 0x8e │ │ │ │ + cmp r7, #110 @ 0x6e │ │ │ │ movs r2, r0 │ │ │ │ - cmp r7, #114 @ 0x72 │ │ │ │ + cmp r7, #82 @ 0x52 │ │ │ │ movs r2, r0 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│ ldr r2, [r0, #40] @ 0x28 │ │ │ │ strh r2, [r3, #14] │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ - cmp r6, #62 @ 0x3e │ │ │ │ + cmp r6, #30 │ │ │ │ movs r2, r0 │ │ │ │ - cmp r6, #24 │ │ │ │ + cmp r5, #248 @ 0xf8 │ │ │ │ movs r2, r0 │ │ │ │ - cmp r6, #4 │ │ │ │ + cmp r5, #228 @ 0xe4 │ │ │ │ movs r2, r0 │ │ │ │ - bge.n 3ed48 │ │ │ │ + bgt.n 3ed18 │ │ │ │ movs r0, r0 │ │ │ │ - bge.n 3ed9c │ │ │ │ + ble.n 3ed6c │ │ │ │ movs r0, r0 │ │ │ │ - blt.n 3edb8 │ │ │ │ + ble.n 3ed88 │ │ │ │ movs r0, r0 │ │ │ │ - bge.n 3ee28 │ │ │ │ + bgt.n 3edf8 │ │ │ │ movs r0, r0 │ │ │ │ - cmp r5, #176 @ 0xb0 │ │ │ │ + cmp r5, #144 @ 0x90 │ │ │ │ movs r2, r0 │ │ │ │ - bls.n 3ee70 │ │ │ │ + blt.n 3ee40 │ │ │ │ movs r0, r0 │ │ │ │ - bls.n 3ee90 │ │ │ │ + blt.n 3ec60 │ │ │ │ movs r0, r0 │ │ │ │ - cmp r5, #90 @ 0x5a │ │ │ │ + cmp r5, #58 @ 0x3a │ │ │ │ movs r2, r0 │ │ │ │ - bhi.n 3ee70 │ │ │ │ + bge.n 3ee40 │ │ │ │ movs r0, r0 │ │ │ │ - bhi.n 3ee98 │ │ │ │ + bge.n 3ec68 │ │ │ │ movs r0, r0 │ │ │ │ - bhi.n 3eecc │ │ │ │ + bge.n 3ec9c │ │ │ │ movs r0, r0 │ │ │ │ - bls.n 3ee34 │ │ │ │ + blt.n 3ee04 │ │ │ │ movs r0, r0 │ │ │ │ - bhi.n 3edf8 │ │ │ │ + bge.n 3edc8 │ │ │ │ movs r0, r0 │ │ │ │ - bhi.n 3ed5c │ │ │ │ + bge.n 3ed2c │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ push {r4, r5, r6, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d14} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4008] @ 0xfa8 │ │ │ │ vabs.f64 d6, d1 │ │ │ │ - vldr d5, [pc, #520] @ 3f000 │ │ │ │ + vldr d5, [pc, #520] @ 3ef88 │ │ │ │ vabs.f64 d7, d0 │ │ │ │ vmov.f64 d10, d3 │ │ │ │ vmov.f64 d9, d4 │ │ │ │ sub sp, #16 │ │ │ │ mov r4, r0 │ │ │ │ mov r5, r1 │ │ │ │ vcmpe.f64 d6, d5 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.n 3ee34 │ │ │ │ + bpl.n 3edbc │ │ │ │ vcmpe.f64 d7, d5 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.n 3ee94 │ │ │ │ + bmi.n 3ee1c │ │ │ │ vcmp.f64 d0, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - beq.n 3ee94 │ │ │ │ - vldr d7, [pc, #476] @ 3f008 │ │ │ │ + beq.n 3ee1c │ │ │ │ + vldr d7, [pc, #476] @ 3ef90 │ │ │ │ vmov.f64 d8, d7 │ │ │ │ - b.n 3eeb2 │ │ │ │ + b.n 3ee3a │ │ │ │ vcmpe.f64 d7, d5 │ │ │ │ vmov.f64 d8, d1 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.n 3eea4 │ │ │ │ + bpl.n 3ee2c │ │ │ │ vcmp.f64 d8, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - beq.n 3ee94 │ │ │ │ + beq.n 3ee1c │ │ │ │ vdiv.f64 d11, d2, d8 │ │ │ │ - ldr r6, [pc, #452] @ (3f018 ) │ │ │ │ + ldr r6, [pc, #452] @ (3efa0 ) │ │ │ │ add r6, pc │ │ │ │ vldr d13, [r6] │ │ │ │ vmul.f64 d0, d13, d8 │ │ │ │ vadd.f64 d7, d11, d9 │ │ │ │ vdiv.f64 d12, d7, d8 │ │ │ │ - blx 2f5c │ │ │ │ + blx 2f0c │ │ │ │ vmul.f64 d11, d11, d13 │ │ │ │ - vldr d7, [pc, #416] @ 3f010 │ │ │ │ + vldr d7, [pc, #416] @ 3ef98 │ │ │ │ vnmls.f64 d11, d12, d0 │ │ │ │ vadd.f64 d11, d11, d10 │ │ │ │ vsub.f64 d11, d11, d12 │ │ │ │ vstr d11, [r4] │ │ │ │ vldr d0, [r6] │ │ │ │ vmul.f64 d0, d8, d0 │ │ │ │ vcmp.f64 d0, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bge.w 3effa │ │ │ │ + bge.w 3ef82 │ │ │ │ vstr d10, [r4] │ │ │ │ vstr d9, [r5] │ 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│ vpop {d8-d14} │ │ │ │ pop {r4, r5, r6, pc} │ │ │ │ vneg.f64 d7, d7 │ │ │ │ vsqrt.f64 d12, d7 │ │ │ │ vmul.f64 d12, d12, d6 │ │ │ │ - blx 2f5c │ │ │ │ + blx 2f0c │ │ │ │ mov r1, sp │ │ │ │ vmov.f64 d13, d0 │ │ │ │ add r0, sp, #8 │ │ │ │ vmul.f64 d0, d12, d14 │ │ │ │ - blx 3074 │ │ │ │ + blx 3028 │ │ │ │ vadd.f64 d10, d11, d10 │ │ │ │ vldr d5, [sp, #8] │ │ │ │ vldr d4, [sp] │ │ │ │ vmul.f64 d7, d10, d8 │ │ │ │ vsub.f64 d9, d9, d7 │ │ │ │ vdiv.f64 d6, d9, d12 │ │ │ │ vmla.f64 d7, d12, d6 │ │ │ │ @@ -68198,61 +68189,61 @@ │ │ │ │ vnmla.f64 d7, d8, d10 │ │ │ │ vadd.f64 d7, d7, d9 │ │ │ │ vdiv.f64 d13, d7, d6 │ │ │ │ vmul.f64 d7, d11, d12 │ │ │ │ vmla.f64 d7, d10, d12 │ │ │ │ vsub.f64 d7, d7, d9 │ │ │ │ vdiv.f64 d9, d7, d6 │ │ │ │ - blx 2f5c │ │ │ │ + blx 2f0c │ │ │ │ vmov.f64 d10, d0 │ │ │ │ vmul.f64 d0, d8, d14 │ │ │ │ - blx 2f5c │ │ │ │ + blx 2f0c │ │ │ │ vmul.f64 d12, d12, d13 │ │ │ │ vmul.f64 d7, d9, d0 │ │ │ │ vmul.f64 d8, d8, d9 │ │ │ │ vmla.f64 d7, d13, d10 │ │ │ │ vmul.f64 d9, d8, d0 │ │ │ │ vmla.f64 d9, d12, d10 │ │ │ │ vsub.f64 d7, d7, d11 │ │ │ │ vstr d7, [r4] │ │ │ │ vstr d9, [r5] │ │ │ │ add sp, #16 │ │ │ │ vpop {d8-d14} │ │ │ │ pop {r4, r5, r6, pc} │ │ │ │ - blx 2f5c │ │ │ │ - b.n 3ee94 │ │ │ │ - bvs.n 3ef2e │ │ │ │ + blx 2f0c │ │ │ │ + b.n 3ee1c │ │ │ │ + bvs.n 3eeb6 │ │ │ │ @ instruction: 0xe8262e0b │ │ │ │ subs r6, #17 │ │ │ │ ... │ │ │ │ cmp r0, #0 │ │ │ │ lsls r6, r0 │ │ │ │ - cmp r3, #234 @ 0xea │ │ │ │ + cmp r3, #202 @ 0xca │ │ │ │ movs r2, r0 │ │ │ │ - cmp r3, #124 @ 0x7c │ │ │ │ + cmp r3, #92 @ 0x5c │ │ │ │ movs r2, r0 │ │ │ │ vldr d1, [r0] │ │ │ │ vldr d0, [r0, #8] │ │ │ │ - b.w 33ec │ │ │ │ + b.w 3394 │ │ │ │ add.w r3, r0, #472 @ 0x1d8 │ │ │ │ add.w r2, r0, #480 @ 0x1e0 │ │ │ │ add.w r1, r0, #488 @ 0x1e8 │ │ │ │ adds r0, #72 @ 0x48 │ │ │ │ - b.w b51c │ │ │ │ + b.w b908 │ │ │ │ nop │ │ │ │ push {r4, r5, r6, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4016] @ 0xfb0 │ │ │ │ - vldr d8, [pc, #196] @ 3f118 │ │ │ │ + vldr d8, [pc, #196] @ 3f0a0 │ │ │ │ mov ip, r1 │ │ │ │ - ldr r2, [pc, #196] @ (3f120 ) │ │ │ │ + ldr r2, [pc, #196] @ (3f0a8 ) │ │ │ │ sub sp, #56 @ 0x38 │ │ │ │ - ldr r3, [pc, #196] @ (3f124 ) │ │ │ │ + ldr r3, [pc, #196] @ (3f0ac ) │ │ │ │ mov r4, r0 │ │ │ │ vdiv.f64 d7, d0, d8 │ │ │ │ add r2, pc │ │ │ │ add.w r6, r0, #72 @ 0x48 │ │ │ │ mov lr, sp │ │ │ │ mov r5, sp │ │ │ │ ldr r3, [r2, r3] │ │ │ │ @@ -68271,87 +68262,87 @@ │ │ │ │ vldr d4, [sp, #16] │ │ │ │ vdiv.f64 d3, d5, d7 │ │ │ │ vdiv.f64 d5, d6, d7 │ │ │ │ vdiv.f64 d6, d4, d7 │ │ │ │ vstr d3, [sp] │ │ │ │ vstr d5, [sp, #8] │ │ │ │ vstr d6, [sp, #16] │ │ │ │ - bl b3c8 │ │ │ │ + bl b66a │ │ │ │ vldr d7, [sp, #16] │ │ │ │ add r2, sp, #24 │ │ │ │ mov r1, r6 │ │ │ │ mov r0, r5 │ │ │ │ vsub.f64 d7, d7, d8 │ │ │ │ vstr d7, [sp, #16] │ │ │ │ - bl b3c8 │ │ │ │ + bl b66a │ │ │ │ vldr d6, [sp, #24] │ │ │ │ vldr d7, [sp, #32] │ │ │ │ vldr d4, [sp, #40] @ 0x28 │ │ │ │ vdiv.f64 d5, d6, d8 │ │ │ │ - ldr r2, [pc, #72] @ (3f128 ) │ │ │ │ + ldr r2, [pc, #72] @ (3f0b0 ) │ │ │ │ vdiv.f64 d6, d7, d8 │ │ │ │ - ldr r3, [pc, #60] @ (3f124 ) │ │ │ │ + ldr r3, [pc, #60] @ (3f0ac ) │ │ │ │ add r2, pc │ │ │ │ vdiv.f64 d7, d4, d8 │ │ │ │ vstr d5, [r4, #536] @ 0x218 │ │ │ │ vstr d6, [r4, #544] @ 0x220 │ │ │ │ vstr d7, [r4, #552] @ 0x228 │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #52] @ 0x34 │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.n 3f10e │ │ │ │ + bne.n 3f096 │ │ │ │ add sp, #56 @ 0x38 │ │ │ │ vpop {d8} │ │ │ │ pop {r4, r5, r6, pc} │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop │ │ │ │ nop.w │ │ │ │ cmp r0, #246 @ 0xf6 │ │ │ │ ldrh r4, [r3, #58] @ 0x3a │ │ │ │ asrs r2, r0, #23 │ │ │ │ eors r0, r0 │ │ │ │ - ldrh r0, [r3, #60] @ 0x3c │ │ │ │ + str r0, [sp, #64] @ 0x40 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - ldrh r6, [r2, #56] @ 0x38 │ │ │ │ + ldrh r6, [r1, #60] @ 0x3c │ │ │ │ movs r1, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d15} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3440] @ 0xd70 │ │ │ │ - ldr r2, [pc, #1004] @ (3f530 ) │ │ │ │ + ldr r2, [pc, #1004] @ (3f4b8 ) │ │ │ │ mov r4, r0 │ │ │ │ - ldr r3, [pc, #1004] @ (3f534 ) │ │ │ │ + ldr r3, [pc, #1004] @ (3f4bc ) │ │ │ │ sub.w sp, sp, #556 @ 0x22c │ │ │ │ add r2, pc │ │ │ │ - vldr d7, [pc, #952] @ 3f508 │ │ │ │ + vldr d7, [pc, #952] @ 3f490 │ │ │ │ vldr d0, [r4, #280] @ 0x118 │ │ │ │ add.w r0, r0, #288 @ 0x120 │ │ │ │ ldr.w r5, [r4, #812] @ 0x32c │ │ │ │ add.w r6, r4, #584 @ 0x248 │ │ │ │ ldr r3, [r2, r3] │ │ │ │ add.w r9, r4, #72 @ 0x48 │ │ │ │ vdiv.f64 d0, d0, d7 │ │ │ │ ldr r3, [r3, #0] │ │ │ │ str r3, [sp, #548] @ 0x224 │ │ │ │ mov.w r3, #0 │ │ │ │ - bl 229c0 │ │ │ │ + bl 22948 │ │ │ │ add.w r3, r4, #240 @ 0xf0 │ │ │ │ str r3, [sp, #44] @ 0x2c │ │ │ │ mov r7, r3 │ │ │ │ vldr d0, [r4, #280] @ 0x118 │ │ │ │ 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bl ab5c │ │ │ │ + bl aa78 │ │ │ │ vldr d3, [r4, #288] @ 0x120 │ │ │ │ - vldr d2, [pc, #768] @ 3f510 │ │ │ │ + vldr d2, [pc, #768] @ 3f498 │ │ │ │ vldr d4, [r4, #296] @ 0x128 │ │ │ │ - vldr d5, [pc, #768] @ 3f518 │ │ │ │ + vldr d5, [pc, #768] @ 3f4a0 │ │ │ │ vdiv.f64 d7, d3, d2 │ │ │ │ vldr d6, [r6] │ │ │ │ vstr d0, [r4, #224] @ 0xe0 │ │ │ │ vdiv.f64 d8, d4, d5 │ │ │ │ vcmp.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.w 3fdac │ │ │ │ + bmi.w 3fd34 │ │ │ │ vsqrt.f64 d0, d7 │ │ │ │ vmov.f64 d10, #112 @ 0x3f800000 1.0 │ │ │ │ vmov.f64 d7, #64 @ 0x3e000000 0.125 │ │ │ │ vldr d4, [r4, #320] @ 0x140 │ │ │ │ vmul.f64 d6, d6, d0 │ │ │ │ vsub.f64 d8, d10, d8 │ │ │ │ - vldr d5, [pc, #720] @ 3f520 │ │ │ │ + vldr d5, [pc, #720] @ 3f4a8 │ │ │ │ vldr d9, [r4, #632] @ 0x278 │ │ │ │ mov r0, r4 │ │ │ │ vmul.f64 d8, d8, d7 │ │ │ │ vmov.f64 d7, d10 │ │ │ │ vmul.f64 d8, d8, d4 │ │ │ │ vmla.f64 d7, d8, d4 │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ vcmp.f64 d7, d5 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ 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r3, r0 │ │ │ │ + adds r4, r7, r7 │ │ │ │ movs r2, r0 │ │ │ │ - ldrb r4, [r2, #31] │ │ │ │ + strh r4, [r1, #2] │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - ldrb r6, [r5, #27] │ │ │ │ + ldrb r6, [r4, #29] │ │ │ │ movs r1, r0 │ │ │ │ push {r4, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4088] @ 0xff8 │ │ │ │ - ldr r4, [pc, #36] @ (40204 ) │ │ │ │ + ldr r4, [pc, #36] @ (4018c ) │ │ │ │ add r4, pc │ │ │ │ ldr r0, [r4, #0] │ │ │ │ - cbz r0, 401f4 │ │ │ │ + cbz r0, 4017c │ │ │ │ ldr r3, [r0, #0] │ │ │ │ str r3, [r4, #0] │ │ │ │ - bl 13b48 │ │ │ │ + bl 13c20 │ │ │ │ ldr r0, [r4, #0] │ │ │ │ cmp r0, #0 │ │ │ │ - bne.n 401e6 │ │ │ │ - ldr r4, [pc, #16] @ (40208 ) │ │ │ │ + bne.n 4016e │ │ │ │ + ldr r4, [pc, #16] @ (40190 ) │ │ │ │ add r4, pc │ │ │ │ ldr r0, [r4, #4] │ │ │ │ - bl 13b48 │ │ │ │ + bl 13c20 │ │ │ │ movs r3, #0 │ │ │ │ str r3, [r4, #4] │ │ │ │ pop {r4, pc} │ │ │ │ - ldr r4, [r6, #20] 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) │ │ │ │ mov r0, r4 │ │ │ │ add r2, pc │ │ │ │ ldr r2, [r2, #4] │ │ │ │ ldr r2, [r2, #8] │ │ │ │ ldr.w r1, [r2, r3, lsl #2] │ │ │ │ addw sp, sp, #1036 @ 0x40c │ │ │ │ vpop {d8-d11} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, lr} │ │ │ │ - b.w 40234 │ │ │ │ + b.w 401bc │ │ │ │ ldr r4, [r4, #36] @ 0x24 │ │ │ │ vmov.f64 d7, #62 @ 0x41f00000 30.0 │ │ │ │ vmov.f64 d10, #96 @ 0x3f000000 0.5 │ │ │ │ adds r5, #16 │ │ │ │ ldrsh.w r3, [r4, #8] │ │ │ │ ldrsh.w r7, [r4, #12] │ │ │ │ ldrsh.w r2, [r4, #10] │ │ │ │ subs r7, r7, r3 │ │ │ │ ldrsh.w r3, [r4, #14] │ │ │ │ subs r3, r3, r2 │ │ │ │ vmov s0, r3 │ │ │ │ vcvt.f64.s32 d0, s0 │ │ │ │ vdiv.f64 d0, d0, d7 │ │ │ │ - blx 35f0 │ │ │ │ + blx 358c │ │ │ │ vadd.f64 d7, d0, d10 │ │ │ │ mov r0, r4 │ │ │ │ vmov.f64 d8, d0 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r1, s15 │ │ │ │ - bl 9e8c │ │ │ │ + bl 9d54 │ │ │ │ vmov s18, r0 │ │ │ │ mov r0, r5 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ vmov s15, r7 │ │ │ │ vmov s13, r0 │ │ │ │ vcvt.f64.s32 d9, s18 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r3, [r3, #0] │ │ │ │ adds r1, r7, #1 │ │ │ │ @@ -69924,198 +69915,198 @@ │ │ │ │ mov r3, r5 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r2, s15 │ │ │ │ vcvt.s32.f64 s15, d8 │ │ │ │ str r2, [sp, #20] │ │ │ │ vstr s15, [sp, #4] │ │ │ │ vmov r9, s15 │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ mov r0, r4 │ │ │ │ - ldr r4, [pc, #368] @ (406fc ) │ │ │ │ + ldr r4, [pc, #368] @ (40684 ) │ │ │ │ mov r3, r5 │ │ │ │ ldr r2, [sp, #20] │ │ │ │ mov r1, r7 │ │ │ │ ldr r4, [r6, r4] │ │ │ │ strd r8, r9, [sp] │ │ │ │ ldrh r4, [r4, #0] │ │ │ │ str r4, [sp, #8] │ │ │ │ - bl 9eb8 │ │ │ │ - b.n 403e6 │ │ │ │ + bl 9d80 │ │ │ │ + b.n 4036e │ │ │ │ vmov.f64 d5, #57 @ 0x41c80000 25.0 │ │ │ │ vldr d6, [r7] │ │ │ │ vadd.f64 d5, d7, d5 │ │ │ │ vcmpe.f64 d5, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bpl.w 40434 │ │ │ │ - bl 2a0e4 │ │ │ │ + bpl.w 403bc │ │ │ │ + bl 2a06c │ │ │ │ mov r5, r0 │ │ │ │ - bl 2a0f0 │ │ │ │ - ldr r2, [pc, #316] @ (40700 ) │ │ │ │ + bl 2a078 │ │ │ │ + ldr r2, [pc, #316] @ (40688 ) │ │ │ │ mov r3, r5 │ │ │ │ add r5, sp, #28 │ │ │ │ add r2, pc │ │ │ │ movs r1, #100 @ 0x64 │ │ │ │ mov r0, r5 │ │ │ │ vstr d0, [sp] │ │ │ │ - blx 34f4 │ │ │ │ + blx 349c │ │ │ │ mov r1, r5 │ │ │ │ mov r0, r4 │ │ │ │ - bl 40234 │ │ │ │ - b.n 403e6 │ │ │ │ + bl 401bc │ │ │ │ + b.n 4036e │ │ │ │ vdiv.f64 d0, d8, d0 │ │ │ │ - blx 30e4 │ │ │ │ + blx 3098 │ │ │ │ vadd.f64 d10, d0, d10 │ │ │ │ mov r0, r4 │ │ │ │ vmov.f64 d8, d0 │ │ │ │ vcvt.s32.f64 s15, d10 │ │ │ │ vmov r1, s15 │ │ │ │ - bl 9e8c │ │ │ │ + bl 9d54 │ │ │ │ vmov s18, r0 │ │ │ │ vcvt.f64.s32 d9, s18 │ │ │ │ vmul.f64 d9, d9, d11 │ │ │ │ - b.n 4051c │ │ │ │ - ldr r2, [pc, #244] @ (40704 ) │ │ │ │ - ldr r3, [pc, #204] @ (406dc ) │ │ │ │ + b.n 404a4 │ │ │ │ + ldr r2, [pc, #244] @ (4068c ) │ │ │ │ + ldr r3, [pc, #204] @ (40664 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr.w r3, [sp, #1028] @ 0x404 │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.w 4072e │ │ │ │ - ldr r1, [pc, #224] @ (40708 ) │ │ │ │ + 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r0 │ │ │ │ - lsls r0, r6, #9 │ │ │ │ + lsls r0, r5, #9 │ │ │ │ movs r0, r0 │ │ │ │ - stmia r3!, {r2, r3, r7} │ │ │ │ + stmia r5!, {r3, r5, r7} │ │ │ │ movs r0, r0 │ │ │ │ - ldrb r4, [r5, #7] │ │ │ │ + ldrb r4, [r4, #9] │ │ │ │ movs r1, r0 │ │ │ │ - stmia r3!, {r1, r2} │ │ │ │ + stmia r5!, {r1, r5} │ │ │ │ movs r0, r0 │ │ │ │ sdiv pc, r7, pc │ │ │ │ - ite hi │ │ │ │ - movhi r0, r0 │ │ │ │ - stmials r3!, {r1, r2, r6} │ │ │ │ + stmia r1!, {r4, r5, r7} │ │ │ │ movs r0, r0 │ │ │ │ - str r2, [r0, #80] @ 0x50 │ │ │ │ + stmia r5!, {r1, r5, r6} │ │ │ │ + movs r0, r0 │ │ │ │ + str r2, [r4, #76] @ 0x4c │ │ │ │ movs r6, r0 │ │ │ │ mov r0, r6 │ │ │ │ - blx 2fd8 │ │ │ │ - ldr r3, [pc, #16] @ (40734 ) │ │ │ │ + blx 2f88 │ │ │ │ + ldr r3, [pc, #16] @ (406bc ) │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #4] │ │ │ │ - b.n 40452 │ │ │ │ + b.n 403da │ │ │ │ mov r3, r9 │ │ │ │ - b.n 406aa │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 40632 │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop │ │ │ │ - str r0, [r6, #64] @ 0x40 │ │ │ │ + str r0, [r2, #64] @ 0x40 │ │ │ │ movs r6, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d15} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3464] @ 0xd88 │ │ │ │ - ldr r4, [pc, #952] @ (40b08 ) │ │ │ │ + ldr r4, [pc, #952] @ (40a90 ) │ │ │ │ mov sl, r0 │ │ │ │ - ldr r3, [pc, #952] @ (40b0c ) │ │ │ │ + ldr r3, [pc, #952] @ (40a94 ) │ │ │ │ sub.w sp, sp, #532 @ 0x214 │ │ │ │ add r4, pc │ │ │ │ - ldr r2, [pc, #948] @ (40b10 ) │ │ │ │ - ldr r1, [pc, #952] @ (40b14 ) │ │ │ │ + ldr r2, [pc, #948] @ (40a98 ) │ │ │ │ + ldr r1, [pc, #952] @ (40a9c ) │ │ │ │ movs r0, #0 │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r4, r3] │ │ │ │ ldr r3, [r3, #0] │ │ │ │ str r3, [sp, #524] @ 0x20c │ │ │ │ mov.w r3, #0 │ │ │ │ ldr.w r3, [sl] │ │ │ │ @@ -70127,35 +70118,35 @@ │ │ │ │ lsls r3, r3, #3 │ │ │ │ add.w r2, r8, r3 │ │ │ │ mov r3, r2 │ │ │ │ add.w r2, r2, #141312 @ 0x22800 │ │ │ │ strd r0, r1, [r3] │ │ │ │ add.w r3, r3, #4416 @ 0x1140 │ │ │ │ cmp r2, r3 │ │ │ │ - bne.n 40788 │ │ │ │ + bne.n 40710 │ │ │ │ ldr.w r3, [sl, #16] │ │ │ │ bic.w r2, r3, #4 │ │ │ │ cmp r2, #8 │ │ │ │ it ne │ │ │ │ cmpne r3, #6 │ │ │ │ - bne.w 40ab4 │ │ │ │ + bne.w 40a3c │ │ │ │ mov r0, sl │ │ │ │ - bl 29d9c │ │ │ │ + bl 29d24 │ │ │ │ subs r3, r0, #0 │ │ │ │ str r3, [sp, #32] │ │ │ │ - ble.w 40a62 │ │ │ │ + ble.w 409ea │ │ │ │ add.w fp, sp, #136 @ 0x88 │ │ │ │ add.w r9, sp, #96 @ 0x60 │ │ │ │ add r5, sp, #264 @ 0x108 │ │ │ │ - vldr d12, [pc, #784] @ 40ad0 │ │ │ │ + vldr d12, [pc, #784] @ 40a58 │ │ │ │ str r5, [sp, #56] @ 0x38 │ │ │ │ mov r5, fp │ │ │ │ - vldr d13, [pc, #784] @ 40ad8 │ │ │ │ + vldr d13, [pc, #784] @ 40a60 │ │ │ │ mov fp, r9 │ │ │ │ - vldr d14, [pc, #784] @ 40ae0 │ │ │ │ + vldr d14, [pc, #784] @ 40a68 │ │ │ │ movs r3, #0 │ │ │ │ str r3, [sp, #20] │ │ │ │ add r3, sp, #80 @ 0x50 │ │ │ │ str r3, [sp, #24] │ │ │ │ add r3, sp, #104 @ 0x68 │ │ │ │ str r3, [sp, #48] @ 0x30 │ │ │ │ add r3, sp, #88 @ 0x58 │ │ │ │ @@ -70171,86 +70162,86 @@ │ │ │ │ str r3, [sp, #8] │ │ │ │ ldr r3, [sp, #44] @ 0x2c │ │ │ │ str r3, [sp, #4] │ │ │ │ ldr r3, [sp, #40] @ 0x28 │ │ │ │ str r3, [sp, #0] │ │ │ │ mov r3, fp │ │ │ │ ldrd r1, r2, [sp, #20] │ │ │ │ - bl 29dd8 │ │ │ │ + bl 29d60 │ │ │ │ vldr d0, [fp] │ │ │ │ vldr d8, [fp, #-8] │ │ │ │ vcmpe.f64 d0, d12 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bhi.w 40a82 │ │ │ │ + bhi.w 40a0a │ │ │ │ vcmpe.f64 d8, d12 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bhi.w 40a82 │ │ │ │ - blx 34dc │ │ │ │ + bhi.w 40a0a │ │ │ │ + blx 3484 │ │ │ │ vmov.f64 d9, d0 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ - blx 34dc │ │ │ │ + blx 3484 │ │ │ │ vmov.f64 d10, d0 │ │ │ │ ldr r3, [sp, #24] │ │ │ │ movs r7, #0 │ │ │ │ ldr r4, [sp, #56] @ 0x38 │ │ │ │ mov r0, r4 │ │ │ │ vldr d11, [r3] │ │ │ │ vldr d8, [r3, #-8] │ │ │ │ - bl acb0 │ │ │ │ + bl ac98 │ │ │ │ vldr d0, [sl, #272] @ 0x110 │ │ │ │ mov r0, r4 │ │ │ │ movs r1, #3 │ │ │ │ vneg.f64 d0, d0 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ mov r0, r4 │ │ │ │ vldr d0, [sl, #264] @ 0x108 │ │ │ │ movs r1, #2 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ mov r0, r4 │ │ │ │ - vldr d0, [pc, #632] @ 40ae8 │ │ │ │ + vldr d0, [pc, #632] @ 40a70 │ │ │ │ movs r1, #2 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ mov r0, r4 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ movs r1, #2 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ vneg.f64 d0, d11 │ │ │ │ mov r0, r4 │ │ │ │ movs r1, #3 │ │ │ │ - bl af7c │ │ │ │ + bl afae │ │ │ │ ldr r6, [sp, #52] @ 0x34 │ │ │ │ ldr r0, [sp, #36] @ 0x24 │ │ │ │ mov r1, r6 │ │ │ │ - vldr d11, [pc, #600] @ 40af0 │ │ │ │ - bl acd0 │ │ │ │ + vldr d11, [pc, #600] @ 40a78 │ │ │ │ + bl acc0 │ │ │ │ mov r1, r6 │ │ │ │ mov r0, r4 │ │ │ │ movs r3, #3 │ │ │ │ mov r2, r5 │ │ │ │ mov r4, r8 │ │ │ │ - bl ae24 │ │ │ │ + bl ae28 │ │ │ │ movs r6, #0 │ │ │ │ str.w fp, [sp, #28] │ │ │ │ - b.n 408c0 │ │ │ │ + b.n 40848 │ │ │ │ add.w r4, r4, #4416 @ 0x1140 │ │ │ │ add.w r3, r8, #141312 @ 0x22800 │ │ │ │ cmp r4, r3 │ │ │ │ - beq.w 40a50 │ │ │ │ + beq.w 409d8 │ │ │ │ ldr r3, [r4, #16] │ │ │ │ cmp r3, #12 │ │ │ │ it ne │ │ │ │ cmpne r3, #0 │ │ │ │ ite eq │ │ │ │ moveq r3, #1 │ │ │ │ movne r3, #0 │ │ │ │ cmp sl, r4 │ │ │ │ it eq │ │ │ │ orreq.w r3, r3, #1 │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 408b2 │ │ │ │ + bne.n 4083a │ │ │ │ vldr d6, [sl, #240] @ 0xf0 │ │ │ │ mov.w r9, #24 │ │ │ │ vldr d5, [r4, #248] @ 0xf8 │ │ │ │ add r0, sp, #112 @ 0x70 │ │ │ │ vldr d7, [r4, #240] @ 0xf0 │ │ │ │ mov r1, r5 │ │ │ │ vldr d4, [sl, #248] @ 0xf8 │ │ │ │ @@ -70265,69 +70256,69 @@ │ │ │ │ vdiv.f64 d6, d4, d14 │ │ │ │ mla r2, r9, r2, sl │ │ │ │ vdiv.f64 d7, d2, d14 │ │ │ │ add.w r2, r2, #848 @ 0x350 │ │ │ │ vstr d5, [r0] │ │ │ │ vstr d6, [r0, #8] │ │ │ │ vstr d7, [r0, #16] │ │ │ │ - bl b264 │ │ │ │ + bl b394 │ │ │ │ ldr.w r3, [sl] │ │ │ │ ldr r0, [r4, #0] │ │ │ │ adds r3, #202 @ 0xca │ │ │ │ add.w r3, r4, r3, lsl #3 │ │ │ │ mul.w r0, r9, r0 │ │ │ │ strd r6, r7, [r3] │ │ │ │ add.w r3, sl, r0 │ │ │ │ vldr d7, [r3, #848] @ 0x350 │ │ │ │ vcmpe.f64 d7, #0.0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bls.n 408b2 │ │ │ │ + bls.n 4083a │ │ │ │ vldr d5, [r3, #856] @ 0x358 │ │ │ │ vldr d4, [r3, #864] @ 0x360 │ │ │ │ vdiv.f64 d6, d5, d7 │ │ │ │ vabs.f64 d6, d6 │ │ │ │ vcmpe.f64 d9, d6 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - blt.n 408b2 │ │ │ │ + blt.n 4083a │ │ │ │ vdiv.f64 d15, d4, d7 │ │ │ │ vabs.f64 d7, d15 │ │ │ │ vcmpe.f64 d10, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - blt.n 408b2 │ │ │ │ + blt.n 4083a │ │ │ │ add.w r0, r0, #848 @ 0x350 │ │ │ │ add r0, sl │ │ │ │ - bl ab5c │ │ │ │ + bl aa78 │ │ │ │ vmul.f64 d7, d0, d11 │ │ │ │ vcmpe.f64 d15, #0.0 │ │ │ │ ldr.w r3, [sl] │ │ │ │ adds r3, #202 @ 0xca │ │ │ │ vmul.f64 d7, d7, d0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ add.w r3, r4, r3, lsl #3 │ │ │ │ vdiv.f64 d6, d8, d7 │ │ │ │ vstr d6, [r3] │ │ │ │ - ble.n 409b8 │ │ │ │ - vldr d7, [pc, #324] @ 40af8 │ │ │ │ + ble.n 40940 │ │ │ │ + vldr d7, [pc, #324] @ 40a80 │ │ │ │ vmul.f64 d0, d0, d7 │ │ │ │ ldr.w r3, [r4, #812] @ 0x32c │ │ │ │ ldrb.w r2, [r3, #1372] @ 0x55c │ │ │ │ cmp r2, #1 │ │ │ │ - bne.w 408b2 │ │ │ │ + bne.w 4083a │ │ │ │ ldrh.w r2, [r3, #1372] @ 0x55c │ │ │ │ movw r3, #257 @ 0x101 │ │ │ │ cmp r2, r3 │ │ │ │ - beq.w 408b2 │ │ │ │ + beq.w 4083a │ │ │ │ ldr.w r3, [sl, #812] @ 0x32c │ │ │ │ vldr d7, [r3, #824] @ 0x338 │ │ │ │ vcmpe.f64 d7, d0 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bls.w 408b2 │ │ │ │ + bls.w 4083a │ │ │ │ ldr.w r3, [sl, #3920] @ 0xf50 │ │ │ │ cmp r3, #15 │ │ │ │ - bgt.w 408b2 │ │ │ │ + bgt.w 4083a │ │ │ │ ldr r2, [r4, #0] │ │ │ │ mov.w lr, #24 │ │ │ │ add.w fp, sl, r3, lsl #6 │ │ │ │ str r2, [sp, #60] @ 0x3c │ │ │ │ adds r3, #1 │ │ │ │ add.w r1, fp, #1904 @ 0x770 │ │ │ │ str r3, [sp, #68] @ 0x44 │ │ │ │ @@ -70347,59 +70338,59 @@ │ │ │ │ vstr d0, [r1] │ │ │ │ str.w r2, [fp, #1912] @ 0x778 │ │ │ │ str.w ip, [fp, #1872] @ 0x750 │ │ │ │ str.w ip, [fp, #1916] @ 0x77c │ │ │ │ str.w r3, [sl, #3920] @ 0xf50 │ │ │ │ add.w r3, r8, #141312 @ 0x22800 │ │ │ │ cmp r4, r3 │ │ │ │ - bne.w 408c0 │ │ │ │ + bne.w 40848 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ ldr r2, [sp, #32] │ │ │ │ adds r3, #1 │ │ │ │ ldr.w fp, [sp, #28] │ │ │ │ cmp r2, r3 │ │ │ │ str r3, [sp, #20] │ │ │ │ - bne.w 407ee │ │ │ │ - ldr r2, [pc, #180] @ (40b18 ) │ │ │ │ - ldr r3, [pc, #164] @ (40b0c ) │ │ │ │ + bne.w 40776 │ │ │ │ + ldr r2, [pc, #180] @ (40aa0 ) │ │ │ │ + ldr r3, [pc, #164] @ (40a94 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #524] @ 0x20c │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.n 40ac6 │ │ │ │ + bne.n 40a4e │ │ │ │ add.w sp, sp, #532 @ 0x214 │ │ │ │ vpop {d8-d15} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ vmov.f64 d11, #96 @ 0x3f000000 0.5 │ │ │ │ - vldr d10, [pc, #120] @ 40b00 │ │ │ │ + vldr d10, [pc, #120] @ 40a88 │ │ │ │ vmul.f64 d0, d0, d11 │ │ │ │ vmul.f64 d8, d8, d11 │ │ │ │ vmul.f64 d0, d0, d13 │ │ │ │ vmul.f64 d8, d8, d13 │ │ │ │ vdiv.f64 d0, d0, d10 │ │ │ │ - blx 34dc │ │ │ │ + blx 3484 │ │ │ │ vmov.f64 d9, d0 │ │ │ │ vdiv.f64 d0, d8, d10 │ │ │ │ - blx 34dc │ │ │ │ + blx 3484 │ │ │ │ vmov.f64 d10, d0 │ │ │ │ - b.n 4083a │ │ │ │ + b.n 407c2 │ │ │ │ cmp r3, #1 │ │ │ │ - bne.n 40a62 │ │ │ │ + bne.n 409ea │ │ │ │ ldr.w r3, [sl, #808] @ 0x328 │ │ │ │ tst.w r3, #14 │ │ │ │ - bne.w 407a6 │ │ │ │ - b.n 40a62 │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + bne.w 4072e │ │ │ │ + b.n 409ea │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop │ │ │ │ nop.w │ │ │ │ - b.n 4101c │ │ │ │ + b.n 40fa4 │ │ │ │ subs r1, #186 @ 0xba │ │ │ │ - bge.n 40bd4 │ │ │ │ + bge.n 40b5c │ │ │ │ subs r7, #248 @ 0xf8 │ │ │ │ cmp r5, #24 │ │ │ │ strb r4, [r0, r1] │ │ │ │ movs r1, #251 @ 0xfb │ │ │ │ ands r1, r1 │ │ │ │ subs r0, r6, r1 │ │ │ │ ldr r2, [r0, #40] @ 0x28 │ │ │ │ @@ -70417,158 +70408,158 @@ │ │ │ │ strb r5, [r2, r5] │ │ │ │ strb r5, [r2, r5] │ │ │ │ subs r7, #245 @ 0xf5 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ strh r0, [r0, #0] │ │ │ │ eors r6, r4 │ │ │ │ - ldrb r6, [r4, #2] │ │ │ │ + ldrb r6, [r3, #4] │ │ │ │ movs r1, r0 │ │ │ │ - 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[sp, #52] @ 0x34 │ │ │ │ add.w r0, r2, ip │ │ │ │ ldr.w r1, [fp, #776] @ 0x308 │ │ │ │ @@ -70616,28 +70607,28 @@ │ │ │ │ add.w r2, r2, #18 │ │ │ │ strh.w r4, [r8, #470] @ 0x1d6 │ │ │ │ strh.w r0, [r8, #452] @ 0x1c4 │ │ │ │ strh.w r2, [r8, #476] @ 0x1dc │ │ │ │ mov.w r2, #6 │ │ │ │ str r1, [sp, #72] @ 0x48 │ │ │ │ str.w r2, [r7, #432] @ 0x1b0 │ │ │ │ - bne.w 416f2 │ │ │ │ + bne.w 4167a │ │ │ │ ldr.w r2, [fp, #808] @ 0x328 │ │ │ │ ldr.w r4, [r8, #36] @ 0x24 │ │ │ │ ldrd r7, r6, [r6] │ │ │ │ cmp r2, #1 │ │ │ │ - ble.w 416b2 │ │ │ │ + ble.w 4163a │ │ │ │ vldr d7, [r5] │ │ │ │ vmov.f64 d6, #112 @ 0x3f800000 1.0 │ │ │ │ cmp r2, #4 │ │ │ │ vadd.f64 d7, d7, d6 │ │ │ │ vstr d7, [fp, #816] @ 0x330 │ │ │ │ - beq.w 41772 │ │ │ │ + beq.w 416fa │ │ │ │ cmp r2, #8 │ │ │ │ - beq.w 417e4 │ │ │ │ + beq.w 4176c │ │ │ │ add.w r2, r8, #8576 @ 0x2180 │ │ │ │ movs r6, #48 @ 0x30 │ │ │ │ adds r2, #48 @ 0x30 │ │ │ │ movs r0, #72 @ 0x48 │ │ │ │ str r2, [sp, #28] │ │ │ │ movs r2, #10 │ │ │ │ str r2, [sp, #80] @ 0x50 │ │ │ │ @@ -70646,19 +70637,19 @@ │ │ │ │ movs r2, #56 @ 0x38 │ │ │ │ str r2, [sp, #60] @ 0x3c │ │ │ │ ldr r1, [sp, #60] @ 0x3c │ │ │ │ mov r0, r4 │ │ │ │ ldr r5, [sp, #64] @ 0x40 │ │ │ │ strh.w r3, [sl, r6] │ │ │ │ add r6, sl │ │ │ │ - ldr r4, [pc, #832] @ (410e8 ) │ │ │ │ + ldr r4, [pc, #832] @ (41070 ) │ │ │ │ add.w lr, sl, r1 │ │ │ │ add.w r1, sl, r5 │ │ │ │ str r1, [sp, #76] @ 0x4c │ │ │ │ - ldr r1, [pc, #824] @ (410ec ) │ │ │ │ + ldr r1, [pc, #824] @ (41074 ) │ │ │ │ add r4, pc │ │ │ │ ldr r2, [sp, #28] │ │ │ │ str r2, [sp, #0] │ │ │ │ add r1, pc │ │ │ │ strh r3, [r6, #4] │ │ │ │ movs r2, #2 │ │ │ │ str r1, [sp, #4] │ │ │ │ @@ -70723,15 +70714,15 @@ │ │ │ │ ldr r6, [sp, #20] │ │ │ │ ldr r5, [sp, #80] @ 0x50 │ │ │ │ strh r3, [r7, #4] │ │ │ │ mov r3, sl │ │ │ │ strh.w r9, [r7, #6] │ │ │ │ movs r7, #2 │ │ │ │ str.w r5, [r6, #432] @ 0x1b0 │ │ │ │ - bl a038 │ │ │ │ + bl 9f00 │ │ │ │ ldr r1, [sp, #40] @ 0x28 │ │ │ │ ldr r2, [sp, #28] │ │ │ │ str r7, [sp, #8] │ │ │ │ str r1, [sp, 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-70912,15 +70903,15 @@ │ │ │ │ strh.w r6, [lr, #2] │ │ │ │ strh.w r6, [lr, #6] │ │ │ │ ldr r6, [sp, #20] │ │ │ │ strh.w r3, [lr, #4] │ │ │ │ mov r3, sl │ │ │ │ str.w r0, [r6, #432] @ 0x1b0 │ │ │ │ ldr.w r0, [r8, #36] @ 0x24 │ │ │ │ - bl a038 │ │ │ │ + bl 9f00 │ │ │ │ ldr r3, [r4, #8] │ │ │ │ ldrh.w r1, [r8, #172] @ 0xac │ │ │ │ ldr.w r2, [r6, #432] @ 0x1b0 │ │ │ │ subs r3, #6 │ │ │ │ add r3, r1 │ │ │ │ ldrh.w r1, [r8, #174] @ 0xae │ │ │ │ add r5, r1 │ │ │ │ @@ -70932,62 +70923,62 @@ │ │ │ │ strh r3, [r1, #4] │ │ │ │ adds r2, #1 │ │ │ │ ldr r3, [sp, #84] @ 0x54 │ │ │ │ strh r5, [r1, #2] │ │ │ │ strh r5, [r1, #6] │ │ │ │ cmp r3, #3 │ │ │ │ str.w r2, [r6, #432] @ 0x1b0 │ │ │ │ - beq.w 41608 │ │ │ │ + beq.w 41590 │ │ │ │ ldr.w r1, [fp, #3920] @ 0xf50 │ │ │ │ add.w r7, fp, #1872 @ 0x750 │ │ │ │ cmp r1, #0 │ │ │ │ - ble.w 41608 │ │ │ │ + ble.w 41590 │ │ │ │ str.w sl, [sp, #40] @ 0x28 │ │ │ │ mov.w r9, #0 │ │ │ │ - vldr d10, [pc, #20] @ 410d0 │ │ │ │ + vldr d10, [pc, #20] @ 41058 │ │ │ │ mov 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│ │ │ + b.n 41578 │ │ │ │ ldr r4, [sp, #20] │ │ │ │ subs r6, r2, #2 │ │ │ │ sub.w ip, r3, #2 │ │ │ │ mov lr, r0 │ │ │ │ uxth r6, r6 │ │ │ │ adds r2, #2 │ │ │ │ ldr.w r5, [r4, #432] @ 0x1b0 │ │ │ │ @@ -71522,33 +71513,33 @@ │ │ │ │ bfi r0, r3, #16, #16 │ │ │ │ strd lr, lr, [r4, #4] │ │ │ │ bfi r6, ip, #16, #16 │ │ │ │ strd r0, r0, [r4, #12] │ │ │ │ strd r6, r6, [r4, #20] │ │ │ │ ldr r4, [sp, #20] │ │ │ │ str.w r5, [r4, #432] @ 0x1b0 │ │ │ │ - b.n 410f0 │ │ │ │ + b.n 41078 │ │ │ │ ldr r3, [sp, #44] @ 0x2c │ │ │ │ mov r0, r4 │ │ │ │ ldr r2, [sp, #48] @ 0x30 │ │ │ │ str r6, [sp, #12] │ │ │ │ add.w r6, r6, r6, lsl #1 │ │ │ │ add.w r1, r3, r7, lsl #2 │ │ │ │ - ldr r3, [pc, #172] @ (41830 ) │ │ │ │ + ldr r3, [pc, #172] @ (417b8 ) │ │ │ │ add r2, r6 │ │ │ │ add r3, pc │ │ │ │ str r3, [sp, #4] │ │ │ │ add.w r3, r8, #8576 @ 0x2180 │ │ │ │ adds r3, #48 @ 0x30 │ │ │ │ str r3, [sp, #28] │ │ │ │ str r3, [sp, #0] │ │ │ │ movs r3, #9 │ │ │ │ str r3, [sp, #8] │ │ │ │ mov r3, sl │ │ │ │ - bl a038 │ │ │ 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(41b70 ) │ │ │ │ + ldr r2, [pc, #708] @ (41af8 ) │ │ │ │ sub sp, #68 @ 0x44 │ │ │ │ - ldr r3, [pc, #708] @ (41b74 ) │ │ │ │ + ldr r3, [pc, #708] @ (41afc ) │ │ │ │ add r2, pc │ │ │ │ - ldr.w sl, [pc, #708] @ 41b78 │ │ │ │ + ldr.w sl, [pc, #708] @ 41b00 │ │ │ │ add sl, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r3, [r3, #0] │ │ │ │ str r3, [sp, #60] @ 0x3c │ │ │ │ mov.w r3, #0 │ │ │ │ ldr.w r3, [r0, #808] @ 0x328 │ │ │ │ ubfx r2, r3, #0, #4 │ │ │ │ subs r3, #0 │ │ │ │ it ne │ │ │ │ movne r3, #1 │ │ │ │ cmp r2, #0 │ │ │ │ it ne │ │ │ │ movne r3, #0 │ │ │ │ - cbnz r3, 41910 │ │ │ │ + cbnz r3, 41898 │ │ │ │ ldr r2, [r1, #36] @ 0x24 │ │ │ │ add.w r4, r1, #164 @ 0xa4 │ │ │ │ - ldr r7, [pc, #668] @ (41b7c ) │ │ │ │ + ldr r7, [pc, #668] @ (41b04 ) │ │ │ │ mov r6, r0 │ │ │ │ ldrsh.w r3, [r1, #176] @ 0xb0 │ │ │ │ mov r8, r1 │ │ │ │ ldr r5, [r2, #4] │ │ │ │ add r7, pc │ │ │ │ ldrsh.w r2, [r1, #172] @ 0xac │ │ │ │ mov r1, r4 │ │ │ │ mov r0, r5 │ │ │ │ subs r3, r3, r2 │ │ │ │ str r3, [r7, #8] │ │ │ │ - bl 4dd0 │ │ │ │ - ldr r3, [pc, #644] @ (41b80 ) │ │ │ │ + bl 4d68 │ │ │ │ + ldr r3, [pc, #644] @ (41b08 ) │ │ │ │ mov r1, r4 │ │ │ │ mov r0, r5 │ │ │ │ ldr.w r3, [sl, r3] │ │ │ │ ldrh r2, [r3, #0] │ │ │ │ - bl 5b70 │ │ │ │ + bl 5b08 │ │ │ │ ldr.w r3, [r6, #808] @ 0x328 │ │ │ │ - cbnz r3, 41930 │ │ │ │ - ldr r2, [pc, #624] @ (41b84 ) │ │ │ │ - ldr r3, [pc, #608] @ (41b74 ) │ │ │ │ + cbnz r3, 418b8 │ │ │ │ + ldr r2, [pc, #624] @ (41b0c ) │ │ │ │ + ldr r3, [pc, #608] @ (41afc ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #60] @ 0x3c │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.w 41b38 │ │ │ │ + bne.w 41ac0 │ │ │ │ add sp, #68 @ 0x44 │ │ │ │ vpop {d8-d15} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ vldr s16, [r7, #8] │ │ │ │ vmov.f64 d7, #96 @ 0x3f000000 0.5 │ │ │ │ ldrsh.w r3, [r8, #164] @ 0xa4 │ │ │ │ vmov s18, r3 │ │ │ │ ldrsh.w r3, [r8, #166] @ 0xa6 │ │ │ │ vcvt.f64.s32 d8, s16 │ │ │ │ vmov s20, r3 │ │ │ │ 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(4237c ) │ │ │ │ add.w r1, sp, #10752 @ 0x2a00 │ │ │ │ - ldr r3, [pc, #136] @ (423e8 ) │ │ │ │ + ldr r3, [pc, #136] @ (42370 ) │ │ │ │ adds r1, #12 │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [r1, #0] │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.n 423b4 │ │ │ │ + bne.n 4233c │ │ │ │ add.w sp, sp, #10752 @ 0x2a00 │ │ │ │ add sp, #20 │ │ │ │ vpop {d8-d15} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ vmov.f64 d6, #96 @ 0x3f000000 0.5 │ │ │ │ vmul.f64 d6, d15, d6 │ │ │ │ - b.n 4214e │ │ │ │ + b.n 420d6 │ │ │ │ vneg.f64 d0, d11 │ │ │ │ vadd.f64 d11, d11, d9 │ │ │ │ vdiv.f64 d0, d0, d9 │ │ │ │ - blx 30e4 │ │ │ │ + blx 3098 │ │ │ │ vmla.f64 d11, d0, d9 │ │ │ │ - b.n 421be │ │ │ │ + b.n 42146 │ │ │ │ vneg.f64 d0, d12 │ │ │ │ vadd.f64 d12, d12, d15 │ │ │ │ vdiv.f64 d0, d0, d15 │ │ │ │ - blx 30e4 │ │ │ │ + blx 3098 │ │ │ │ vmla.f64 d12, d15, d0 │ │ │ │ - b.n 4218a │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 42112 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r0, [r1, #58] @ 0x3a │ │ │ │ movs r1, r0 │ │ │ │ - ldrb r4, [r3, r2] │ │ │ │ + ldrb r4, [r2, r4] │ │ │ │ movs r1, r0 │ │ │ │ - ldr r3, [pc, #28] @ (42418 ) │ │ │ │ + ldr r3, [pc, #28] @ (423a0 ) │ │ │ │ vmov.f64 d7, d0 │ │ │ │ add r3, pc │ │ │ │ ldr r3, [r3, #16] │ │ │ │ - cbnz r3, 42416 │ │ │ │ - ldr r3, [pc, #20] @ (4241c ) │ │ │ │ + cbnz r3, 4239e │ │ │ │ + ldr r3, [pc, #20] @ (423a4 ) │ │ │ │ vldr d0, [r0, #280] @ 0x118 │ │ │ │ add r3, pc │ │ │ │ vsub.f64 d0, d0, d7 │ │ │ │ vldr d1, [r3] │ │ │ │ - b.n 41e8c │ │ │ │ - b.n 4207c │ │ │ │ - bx pc │ │ │ │ + b.n 41e14 │ │ │ │ + b.n 42004 │ │ │ │ + bx fp │ │ │ │ movs r6, r0 │ │ │ │ - ldrh r2, [r4, #34] @ 0x22 │ │ │ │ + ldrh r2, [r0, #34] @ 0x22 │ │ │ │ movs r1, r0 │ │ │ │ - vldr d7, [pc, #44] @ 42450 │ │ │ │ + vldr d7, [pc, #44] @ 423d8 │ │ │ │ vcmpe.f64 d0, d7 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - bmi.n 4244a │ │ │ │ - vldr d7, [pc, #40] @ 42458 │ │ │ │ + bmi.n 423d2 │ │ │ │ + vldr d7, [pc, #40] @ 423e0 │ │ │ │ vcmp.f64 d0, d7 │ │ │ │ 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(adr r5, 42bc4 ) │ │ │ │ + add r7, pc, #744 @ (adr r7, 42bbc ) │ │ │ │ movs r0, r0 │ │ │ │ @ instruction: 0xf961ffff │ │ │ │ - lsls r0, r5, #11 │ │ │ │ + lsls r0, r4, #11 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r5, #9 │ │ │ │ + lsls r0, r4, #9 │ │ │ │ movs r0, r0 │ │ │ │ - add r8, sp │ │ │ │ + add r8, r9 │ │ │ │ movs r6, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - mvns r0, r7 │ │ │ │ + mvns r0, r3 │ │ │ │ movs r6, r0 │ │ │ │ - strh r6, [r4, #60] @ 0x3c │ │ │ │ + strh r6, [r0, #60] @ 0x3c │ │ │ │ movs r1, r0 │ │ │ │ - bl 6358 │ │ │ │ + bl 62f0 │ │ │ │ ldr r0, [r5, #64] @ 0x40 │ │ │ │ cmp r0, #0 │ │ │ │ - beq.w 42ef6 │ │ │ │ - bl 47eb8 │ │ │ │ + beq.w 42e7e │ │ │ │ + bl 47e40 │ │ │ │ cmp r0, #0 │ │ │ │ - bne.w 430ce │ │ │ │ - ldr r3, [pc, #840] @ (42cc8 ) │ │ │ │ + bne.w 43056 │ │ │ │ + ldr r3, [pc, #840] @ (42c50 ) │ │ │ │ add r3, pc │ │ │ │ ldr r0, [r3, #24] │ │ │ │ - ldr.w sl, [pc, #836] @ 42ccc │ │ │ │ - bl 6a54 │ │ │ │ + ldr.w sl, [pc, #836] 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#1]! │ │ │ │ ldrb.w r3, [r2, #1]! │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 43baa │ │ │ │ + bne.n 43b32 │ │ │ │ rsb r7, r7, #1 │ │ │ │ add.w sl, sp, #64 @ 0x40 │ │ │ │ adds r3, r0, r7 │ │ │ │ add r3, sl │ │ │ │ movs r7, #0 │ │ │ │ movs r2, #10 │ │ │ │ mov r1, r7 │ │ │ │ strb r7, [r3, #0] │ │ │ │ mov r0, r6 │ │ │ │ add.w r8, sp, #56 @ 0x38 │ │ │ │ - blx 3298 │ │ │ │ + blx 3250 │ │ │ │ mov r1, r7 │ │ │ │ mov r9, r0 │ │ │ │ movs r2, #10 │ │ │ │ mov r0, r8 │ │ │ │ - blx 3298 │ │ │ │ + blx 3250 │ │ │ │ mov r7, r0 │ │ │ │ cmp r9, r0 │ │ │ │ - bgt.w 44310 │ │ │ │ + bgt.w 44298 │ │ │ │ cmp.w r9, #36 @ 0x24 │ │ │ │ it ls │ │ │ │ cmpls r7, #36 @ 0x24 │ │ │ │ - bls.n 43c06 │ │ │ │ - ldr r3, [pc, #392] @ (43d80 ) │ │ │ │ + bls.n 43b8e │ │ │ │ + ldr r3, [pc, #392] @ (43d08 ) │ │ │ │ ldr r2, [sp, #32] │ │ │ │ - ldr r1, [pc, #392] @ (43d84 ) │ │ │ │ + ldr r1, [pc, #392] @ (43d0c ) │ │ │ │ ldr r3, [r2, r3] │ │ │ │ add r1, pc │ │ │ │ ldr r2, [sp, #28] │ │ │ │ ldr r0, [r3, #0] │ │ │ │ - blx 3394 │ │ │ │ + blx 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│ │ movgt r3, #0 │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 43d20 │ │ │ │ + bne.n 43ca8 │ │ │ │ ldrb.w r3, [sp, #48] @ 0x30 │ │ │ │ - cbz r3, 43c7e │ │ │ │ + cbz r3, 43c06 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov r3, r5 │ │ │ │ movs r2, #1 │ │ │ │ mov r1, r4 │ │ │ │ add r0, sp, #48 @ 0x30 │ │ │ │ - bl 435c0 │ │ │ │ + bl 43548 │ │ │ │ vmov.f64 d7, #58 @ 0x41d00000 26.0 │ │ │ │ vadd.f64 d9, d9, d7 │ │ │ │ mov r3, r5 │ │ │ │ vmov.f64 d0, d9 │ │ │ │ mov r0, r6 │ │ │ │ movs r2, #1 │ │ │ │ mov r1, r4 │ │ │ │ vmov.f64 d10, #52 @ 0x41a00000 20.0 │ │ │ │ - bl 435c0 │ │ │ │ + bl 43548 │ │ │ │ ldrb.w r3, [sp, #64] @ 0x40 │ │ │ │ vadd.f64 d10, d9, d10 │ │ │ │ cmp r3, #0 │ │ │ │ - bne.w 442dc │ │ │ │ + bne.w 44264 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ mov r3, r5 │ │ │ │ movs r2, #0 │ │ │ │ mov r0, r8 │ │ │ │ mov r1, r4 │ │ │ │ - bl 435c0 │ │ │ │ + bl 43548 │ │ │ │ vmov.f64 d7, #52 @ 0x41a00000 20.0 │ │ │ │ - vldr d6, [pc, #192] @ 43d78 │ │ │ │ + vldr d6, [pc, #192] @ 43d00 │ │ │ │ vsub.f64 d8, d8, d7 │ │ │ │ vadd.f64 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3394 │ │ │ │ - b.n 43c60 │ │ │ │ + blx 334c │ │ │ │ + b.n 43be8 │ │ │ │ add r7, sp, #72 @ 0x48 │ │ │ │ mov r1, r6 │ │ │ │ mov r0, r7 │ │ │ │ add.w fp, sp, #48 @ 0x30 │ │ │ │ - blx 305c │ │ │ │ + blx 3010 │ │ │ │ mov r1, r8 │ │ │ │ mov r9, r0 │ │ │ │ mov r0, r6 │ │ │ │ - blx 32a4 │ │ │ │ + blx 325c │ │ │ │ sub.w r2, r9, r7 │ │ │ │ adds r2, #1 │ │ │ │ mov r1, r7 │ │ │ │ mov r0, r8 │ │ │ │ - blx 3228 │ │ │ │ + blx 31e0 │ │ │ │ mov r1, fp │ │ │ │ mov r0, r7 │ │ │ │ - blx 305c │ │ │ │ + blx 3010 │ │ │ │ mov r1, sl │ │ │ │ mov r9, r0 │ │ │ │ mov r0, fp │ │ │ │ - blx 32a4 │ │ │ │ + blx 325c │ │ │ │ sub.w r2, r9, r7 │ │ │ │ adds r2, #1 │ │ │ │ mov r1, r7 │ │ │ │ mov r0, sl │ │ │ │ - blx 3228 │ │ │ │ - b.n 43c60 │ │ │ │ + blx 31e0 │ │ │ │ + b.n 43be8 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ strh r0, [r0, #0] │ │ │ │ eors r6, r4 │ │ │ │ cmp r5, #24 │ │ │ │ strb r4, [r0, r1] │ │ │ │ movs r1, #251 @ 0xfb │ │ │ │ ands r1, r1 │ │ │ │ str.w ip, [r9, #985] @ 0x3d9 │ │ │ │ - ldr r1, [pc, #752] @ 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@ 0xa4 │ │ │ │ - blx 3228 │ │ │ │ + blx 31e0 │ │ │ │ ldr r3, [sp, #36] @ 0x24 │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ movs r1, #147 @ 0x93 │ │ │ │ str.w r0, [sl, #188] @ 0xbc │ │ │ │ ldr.w sl, [sp, #16] │ │ │ │ mov r0, sl │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ ldr.w r2, [r8] │ │ │ │ ldr r3, [sp, #36] @ 0x24 │ │ │ │ movs r1, #6 │ │ │ │ str r3, [r0, #8] │ │ │ │ str r3, [r0, #16] │ │ │ │ str.w r9, [r0, #24] │ │ │ │ strd r9, r5, [r0, #32] │ │ │ │ @@ -74931,15 +74922,15 @@ │ │ │ │ str r1, [r0, #12] │ │ │ │ str r1, [r0, #20] │ │ │ │ movs r1, #158 @ 0x9e │ │ │ │ str r0, [r2, #68] @ 0x44 │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ mov r0, sl │ │ │ │ str r3, [sp, #16] │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ movs r3, #16 │ │ │ │ strd r3, r6, [r0] │ │ │ │ mov.w lr, #16 │ │ │ │ ldr r3, [sp, #16] │ │ │ │ movs r2, #3 │ │ │ │ strd r3, r6, [r0, #8] │ │ │ │ movs r1, #13 │ │ │ │ @@ -74973,15 +74964,15 @@ │ │ │ │ ldr.w r2, [r8] │ │ │ │ str.w r3, [r0, #128] @ 0x80 │ │ │ │ str r3, [sp, #36] @ 0x24 │ │ │ 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0x6c │ │ │ │ str r0, [r2, #80] @ 0x50 │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ mov.w lr, #16 │ │ │ │ mov.w ip, #14 │ │ │ │ movs r1, #14 │ │ │ │ movs r2, #2 │ │ │ │ strd r1, r2, [r0, #20] │ │ │ │ movs r2, #10 │ │ │ │ strd ip, r2, [r0, #28] │ │ │ │ @@ -75080,15 +75071,15 @@ │ │ │ │ str r1, [r0, #76] @ 0x4c │ │ │ │ str r1, [r0, #84] @ 0x54 │ │ │ │ str r1, [r0, #108] @ 0x6c │ │ │ │ movs r1, #240 @ 0xf0 │ │ │ │ str r0, [r2, #84] @ 0x54 │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ movs r3, #5 │ │ │ │ str r3, [r0, #52] @ 0x34 │ │ │ │ movs r1, #2 │ │ │ │ ldr r3, [sp, #36] @ 0x24 │ │ │ │ movs r2, #3 │ │ │ │ strd r3, fp, [r0, #16] │ │ │ │ strd r3, r6, [r0, #24] │ │ │ │ @@ -75112,15 +75103,15 @@ │ │ │ │ strd r5, r5, [r0, #88] @ 0x58 │ │ │ │ strd r9, r5, [r0, #104] @ 0x68 │ │ │ │ str r2, [r0, #120] @ 0x78 │ │ │ │ ldr.w r2, [r8] │ │ │ │ str r0, [r2, #88] @ 0x58 │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ movs r2, #16 │ │ │ │ strd r2, r7, [r0, #56] @ 0x38 │ │ │ │ movs r3, #10 │ │ │ │ strd r2, r7, [r0, #64] @ 0x40 │ │ │ │ movs r2, #13 │ │ │ │ strd r2, r5, [r0, #72] @ 0x48 │ │ │ │ movs r2, #6 │ │ │ │ @@ -75134,15 +75125,15 @@ │ │ │ │ strd r9, r3, [r0, #40] @ 0x28 │ │ │ │ strd r9, r3, [r0, #48] @ 0x30 │ │ │ │ strd r5, r6, [r0, #24] │ │ │ │ strd fp, r6, [r0, #32] │ │ │ │ str r0, [r2, #92] @ 0x5c │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ mov.w ip, #18 │ │ │ │ movs r3, #2 │ │ │ │ strd ip, r3, [r0] │ │ │ │ ldr r3, [sp, #36] @ 0x24 │ │ │ │ movs r2, #16 │ │ │ │ strd r3, r5, [r0, #8] │ │ │ │ mov.w r1, #298 @ 0x12a │ │ │ │ @@ -75171,15 +75162,15 @@ │ │ │ │ movs r2, #18 │ │ │ │ strd r2, r3, [r0, #136] @ 0x88 │ │ │ │ ldr.w r2, [r8] │ │ │ │ str.w r3, [r0, #132] @ 0x84 │ │ │ │ str r0, [r2, #96] @ 0x60 │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ movs r3, #9 │ │ │ │ str r3, [r0, #40] @ 0x28 │ │ │ │ movs r3, #18 │ │ │ │ strd r3, fp, [r0, #8] │ │ │ │ movs r3, #3 │ │ │ │ strd r3, r9, [r0, #20] │ │ │ │ mov.w lr, #3 │ │ │ │ @@ -75208,15 +75199,15 @@ │ │ │ │ str r7, [r0, #96] @ 0x60 │ │ │ │ str r6, [r0, #116] @ 0x74 │ │ │ │ str r2, [r0, #120] @ 0x78 │ │ │ │ ldr.w r2, [r8] │ │ │ │ str r0, [r2, #100] @ 0x64 │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ movs r2, #3 │ │ │ │ strd r2, r2, [r0, #8] │ │ │ │ movs r3, #17 │ │ │ │ str r2, [r0, #68] @ 0x44 │ │ │ │ movs r2, #16 │ │ │ │ strd r2, r6, [r0, #48] @ 0x30 │ │ │ │ movw r1, #333 @ 0x14d │ │ │ │ @@ -75232,15 +75223,15 @@ │ │ │ │ str r3, [r0, #4] │ │ │ │ strd r5, r5, [r0, #32] │ │ │ │ strd r5, r5, [r0, #40] @ 0x28 │ │ │ │ str.w r9, [r0, #64] @ 0x40 │ │ │ │ str.w r0, [r2, #140] @ 0x8c │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ ldr.w r1, [r8] │ │ │ │ movs r3, #6 │ │ │ │ str r3, [r0, #0] │ │ │ │ ldr r3, [sp, #36] @ 0x24 │ │ │ │ mov r2, r0 │ │ │ │ strd r6, r3, [r0, #12] │ │ │ │ strd r3, r9, [r0, #44] @ 0x2c │ │ │ │ @@ -75249,15 +75240,15 @@ │ │ │ │ strd r5, r5, [r0, #28] │ │ │ │ strd r5, r9, [r0, #36] @ 0x24 │ │ │ │ ldr r0, [sp, #16] │ │ │ │ str.w r2, [r1, #176] @ 0xb0 │ │ │ │ movs r2, #164 @ 0xa4 │ │ │ │ mov.w r1, #344 @ 0x158 │ │ │ │ str r3, [sp, #16] │ │ │ │ - bl 139e8 │ │ │ │ + bl 13ac0 │ │ │ │ movs r3, #10 │ │ │ │ str r3, [r0, #96] @ 0x60 │ │ │ │ movs r3, #18 │ │ │ │ str r3, [r0, #104] @ 0x68 │ │ │ │ movs r2, #16 │ │ │ │ ldr r3, [sp, #16] │ │ │ │ movs r1, #1 │ │ │ │ @@ -75282,141 +75273,141 @@ │ │ │ │ str.w r9, [r0, #112] @ 0x70 │ │ │ │ str.w r9, [r0, #120] @ 0x78 │ │ │ │ strd r3, r3, [r0, #4] │ │ │ │ str r3, [r0, #80] @ 0x50 │ │ │ │ str r3, [r0, #116] @ 0x74 │ │ │ │ ldr.w r3, [r8] │ │ │ │ str.w r0, [r3, #200] @ 0xc8 │ │ │ │ - ldr r0, [pc, #204] @ (44384 ) │ │ │ │ + ldr r0, [pc, #204] @ (4430c ) │ │ │ │ add r0, pc │ │ │ │ - bl 69c8 │ │ │ │ + bl 6960 │ │ │ │ str.w r0, [r8, #8] │ │ │ │ - ldr r0, [pc, #196] @ (44388 ) │ │ │ │ + ldr r0, [pc, #196] @ (44310 ) │ │ │ │ movs r1, #1 │ │ │ │ add r0, pc │ │ │ │ - bl 69c8 │ │ │ │ + bl 6960 │ │ │ │ str.w r0, [r8, #4] │ │ │ │ - ldr r0, [pc, #184] @ (4438c ) │ │ │ │ + ldr r0, [pc, #184] @ (44314 ) │ │ │ │ add r0, pc │ │ │ │ - bl 14098 │ │ │ │ - b.w 436ca │ │ │ │ + bl 14170 │ │ │ │ + b.w 43652 │ │ │ │ vmov.f64 d0, d8 │ │ │ │ mov r3, r5 │ │ │ │ movs r2, #0 │ │ │ │ mov r1, r4 │ │ │ │ add r0, sp, #64 @ 0x40 │ │ │ │ - bl 435c0 │ │ │ │ + bl 43548 │ │ │ │ vmov.f64 d7, #58 @ 0x41d00000 26.0 │ │ │ │ vsub.f64 d8, d8, d7 │ │ │ │ - b.n 43ca0 │ │ │ │ + b.n 43c28 │ │ │ │ ldrd r2, r1, [sp, #28] │ │ │ │ add r6, sp, #40 @ 0x28 │ │ │ │ - ldr r3, [pc, #144] @ (44390 ) │ │ │ │ + ldr r3, [pc, #144] @ (44318 ) │ │ │ │ add.w r8, sp, #56 @ 0x38 │ │ │ │ ldr r3, [r1, r3] │ │ │ │ - ldr r1, [pc, #140] @ (44394 ) │ │ │ │ + ldr r1, [pc, #140] @ (4431c ) │ │ │ │ ldr r0, [r3, #0] │ │ │ │ add r1, pc │ │ │ │ - blx 3394 │ │ │ │ - b.n 43c60 │ │ │ │ + blx 334c │ │ │ │ + b.n 43be8 │ │ │ │ add.w fp, sp, #72 @ 0x48 │ │ │ │ mov r1, r6 │ │ │ │ mov r0, fp │ │ │ │ - blx 305c │ │ │ │ + blx 3010 │ │ │ │ mov r1, r8 │ │ │ │ str r0, [sp, #36] @ 0x24 │ │ │ │ mov r0, r6 │ │ │ │ - blx 32a4 │ │ │ │ + blx 325c │ │ │ │ ldr r3, [sp, #36] @ 0x24 │ │ │ │ mov r1, fp │ │ │ │ mov r0, r8 │ │ │ │ sub.w r3, r3, fp │ │ │ │ adds r2, r3, #1 │ │ │ │ - blx 3228 │ │ │ │ + blx 31e0 │ │ │ │ add r1, sp, #48 @ 0x30 │ │ │ │ mov r0, fp │ │ │ │ str r1, [sp, #36] @ 0x24 │ │ │ │ - blx 305c │ │ │ │ + blx 3010 │ │ │ │ ldr r1, [sp, #36] @ 0x24 │ │ │ │ mov r3, r0 │ │ │ │ str r3, [sp, #36] @ 0x24 │ │ │ │ mov r0, r1 │ │ │ │ mov r1, sl │ │ │ │ - blx 32a4 │ │ │ │ + blx 325c │ │ │ │ ldr r3, [sp, #36] @ 0x24 │ │ │ │ mov r1, fp │ │ │ │ mov r0, sl │ │ │ │ sub.w r3, r3, fp │ │ │ │ adds r2, r3, #1 │ │ │ │ - blx 3228 │ │ │ │ + blx 31e0 │ │ │ │ mov r3, r9 │ │ │ │ mov r9, r7 │ │ │ │ mov r7, r3 │ │ │ │ - b.n 43bea │ │ │ │ + b.n 43b72 │ │ │ │ add.w r3, r1, #88 @ 0x58 │ │ │ │ add.w r1, sp, r3 │ │ │ │ strb.w r2, [r1, #-32] │ │ │ │ add.w sl, sp, #64 @ 0x40 │ │ │ │ mov r3, sl │ │ │ │ - b.n 43bc4 │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 43b4c │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop │ │ │ │ - ldrh r0, [r7, #40] @ 0x28 │ │ │ │ + ldrh r4, [r2, #58] @ 0x3a │ │ │ │ movs r0, r0 │ │ │ │ - ldrh r0, [r5, #0] │ │ │ │ + ldrh r4, [r0, #18] │ │ │ │ movs r0, r0 │ │ │ │ - ldrsb r6, [r7, r3] │ │ │ │ + ldrsb r6, [r6, r3] │ │ │ │ movs r0, r0 │ │ │ │ - bl 2e438e <__bss_end__@@Base+0x23d756> │ │ │ │ - lsls r0, r4, #12 │ │ │ │ + bl 2e4316 <__bss_end__@@Base+0x23d776> │ │ │ │ + lsls r0, r3, #12 │ │ │ │ movs r0, r0 │ │ │ │ - strh r0, [r4, #62] @ 0x3e │ │ │ │ + ldrh r4, [r7, #14] │ │ │ │ movs r0, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d10} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3704] @ 0xe78 │ │ │ │ vldr s15, [r1, #24] │ │ │ │ vmov.f64 d10, #96 @ 0x3f000000 0.5 │ │ │ │ vldr d5, [r1, #16] │ │ │ │ sub sp, #332 @ 0x14c │ │ │ │ - ldr r2, [pc, #652] @ (44648 ) │ │ │ │ + ldr r2, [pc, #652] @ (445d0 ) │ │ │ │ vcvt.f64.s32 d6, s15 │ │ │ │ - ldr r3, [pc, #648] @ (4464c ) │ │ │ │ + ldr r3, [pc, #648] @ (445d4 ) │ │ │ │ add r2, pc │ │ │ │ vdiv.f64 d7, d6, d5 │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r3, [r3, #0] │ │ │ │ str r3, [sp, #324] @ 0x144 │ │ │ │ mov.w r3, #0 │ │ │ │ str r0, [sp, #36] @ 0x24 │ │ │ │ vadd.f64 d7, d7, d10 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r5, s15 │ │ │ │ vstr s15, [sp, #20] │ │ │ │ - cbnz r5, 44406 │ │ │ │ - ldr r2, [pc, #616] @ (44650 ) │ │ │ │ - ldr r3, [pc, #608] @ (4464c ) │ │ │ │ + cbnz r5, 4438e │ │ │ │ + ldr r2, [pc, #616] @ (445d8 ) │ │ │ │ + ldr r3, [pc, #608] @ (445d4 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #324] @ 0x144 │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.w 44636 │ │ │ │ + bne.w 445be │ │ │ │ add sp, #332 @ 0x14c │ │ │ │ vpop {d8-d10} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ mov r4, r1 │ │ │ │ ldr.w r8, [r1, #4] │ │ │ │ ldr r1, [r1, #64] @ 0x40 │ │ │ │ vmov.f64 d8, d0 │ │ │ │ ldr r7, [r4, #8] │ │ │ │ - bl 9e8c │ │ │ │ + bl 9d54 │ │ │ │ ldr r6, [r4, #8] │ │ │ │ vmov s15, r6 │ │ │ │ ldr r2, [r4, #24] │ │ │ │ str r2, [sp, #24] │ │ │ │ vcvt.f64.s32 d6, s15 │ │ │ │ vmov.f64 d7, d10 │ │ │ │ mov r1, r2 │ │ │ │ @@ -75425,48 +75416,48 @@ │ │ │ │ vmla.f64 d7, d6, d10 │ │ │ │ vcvt.s32.f64 s13, d8 │ │ │ │ vmov r5, s13 │ │ │ │ vcvt.s32.f64 s14, d7 │ │ │ │ mov r0, r5 │ │ │ │ vmov r2, s14 │ │ │ │ sub.w r9, r3, r2 │ │ │ │ - bl 4933c │ │ │ │ + bl 492c4 │ │ │ │ subs r3, r5, r1 │ │ │ │ vmov s18, r3 │ │ │ │ vldr d6, [r4, #16] │ │ │ │ mov r0, r6 │ │ │ │ vcvt.f64.s32 d9, s18 │ │ │ │ ldr r5, [sp, #20] │ │ │ │ lsls r1, r5, #1 │ │ │ │ vsub.f64 d9, d8, d9 │ │ │ │ vdiv.f64 d7, d9, d6 │ │ │ │ vadd.f64 d7, d7, d10 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r6, s15 │ │ │ │ - bl 490a8 │ │ │ │ + bl 49030 │ │ │ │ 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#308 @ 0x134 │ │ │ │ - vldr d10, [pc, #320] @ 44640 │ │ │ │ + vldr d10, [pc, #320] @ 445c8 │ │ │ │ mov.w r8, #1 │ │ │ │ vmov.f64 d9, #96 @ 0x3f000000 0.5 │ │ │ │ str r3, [sp, #40] @ 0x28 │ │ │ │ strd r2, r0, [sp, #28] │ │ │ │ - b.n 4452a │ │ │ │ + b.n 444b2 │ │ │ │ add r1, r7 │ │ │ │ strh.w r1, [fp, #4] │ │ │ │ add.w r8, r8, #1 │ │ │ │ ldr r3, [sp, #20] │ │ │ │ subs r5, r5, r3 │ │ │ │ ldr r3, [sp, #28] │ │ │ │ add r6, r3 │ │ │ │ ldr r3, [sp, #32] │ │ │ │ cmp r3, r5 │ │ │ │ - bge.n 4460e │ │ │ │ + bge.n 44596 │ │ │ │ cmp r6, #0 │ │ │ │ - blt.n 4451c │ │ │ │ + blt.n 444a4 │ │ │ │ mov.w r9, r8, lsl #3 │ │ │ │ ldr r7, [r4, #0] │ │ │ │ add.w fp, sl, r9 │ │ │ │ ldr r3, [r4, #12] │ │ │ │ sxth.w ip, r5 │ │ │ │ strh.w r7, [sl, r8, lsl #3] │ │ │ │ ldr r1, [r4, #32] │ │ │ │ mov r0, r6 │ │ │ │ strh.w ip, [fp, #6] │ │ │ │ and.w r3, r3, #1 │ │ │ │ strh.w ip, [fp, #2] │ │ │ │ uxth r7, r7 │ │ │ │ str r3, [sp, #24] │ │ │ │ - bl 4933c │ │ │ │ + bl 492c4 │ │ │ │ ldr r3, [sp, #24] │ │ │ │ - cbz r1, 4456c │ │ │ │ + cbz r1, 444f4 │ │ │ │ ldrh r1, [r4, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 44512 │ │ │ │ + bne.n 4449a │ │ │ │ subs r7, r7, r1 │ │ │ │ strh.w r7, [fp, #4] │ │ │ │ - b.n 44518 │ │ │ │ + b.n 444a0 │ │ │ │ ldrh r2, [r4, #36] @ 0x24 │ │ │ │ cmp r3, #0 │ │ │ │ - beq.n 4461c │ │ │ │ + beq.n 445a4 │ │ │ │ adds r3, r2, r7 │ │ │ │ sxth r3, r3 │ │ │ │ vmov s15, r6 │ │ │ │ vldr d6, [r4, #48] @ 0x30 │ │ │ │ add.w r2, sl, r9 │ │ │ │ ldr.w fp, [sp, #40] @ 0x28 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ ldr r1, [r4, #56] @ 0x38 │ │ │ │ mov r0, fp │ │ │ │ strh r3, [r2, #4] │ │ │ │ vdiv.f64 d7, d7, d6 │ │ │ │ vmov r2, r3, d7 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ ldrb.w r3, [sp, #308] @ 0x134 │ │ │ │ cmp r3, #32 │ │ │ │ - bne.n 44630 │ │ │ │ + bne.n 445b8 │ │ │ │ ldrb.w r3, [fp, #1]! │ │ │ │ cmp r3, #32 │ │ │ │ - beq.n 445a4 │ │ │ │ + beq.n 4452c │ │ │ │ vldr s16, [r4, #64] @ 0x40 │ │ │ │ vmov.f64 d7, d9 │ │ │ │ mov r0, fp │ │ │ │ add r9, sl │ │ │ │ vcvt.f64.s32 d6, s16 │ │ │ │ ldrh.w r9, [r9, #4] │ │ │ │ vmla.f64 d7, d6, d10 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r7, s15 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ ldr r3, [r4, #12] │ │ │ │ str r0, [sp, #0] │ │ │ │ vstr s16, [sp, #4] │ │ │ │ lsls r3, r3, #31 │ │ │ │ add r7, r5 │ │ │ │ itet pl │ │ │ │ subpl.w r1, r9, #3 │ │ │ │ @@ -75575,93 +75566,93 @@ │ │ │ │ ldrh r0, [r4, #60] @ 0x3c │ │ │ │ str r0, [sp, #8] │ │ │ │ it pl │ │ │ │ subpl r1, r1, r3 │ │ │ │ ldr r0, [sp, #36] @ 0x24 │ │ │ │ mov r3, fp │ │ │ │ sxth r1, r1 │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ ldr r3, [r4, #24] │ │ │ │ str r3, [sp, #28] │ │ │ │ - b.n 44518 │ │ │ │ + b.n 444a0 │ │ │ │ mov.w r8, #1 │ │ │ │ ldrh r3, [r4, #60] @ 0x3c │ │ │ │ mov r2, r8 │ │ │ │ ldr r0, [sp, #36] @ 0x24 │ │ │ │ mov r1, sl │ │ │ │ - bl 9e84 │ │ │ │ - b.n 443e6 │ │ │ │ + bl 9d4c │ │ │ │ + b.n 4436e │ │ │ │ subs r3, r7, r2 │ │ │ │ sxth r3, r3 │ │ │ │ - b.n 44576 │ │ │ │ - ldr r0, [pc, #48] @ (44654 ) │ │ │ │ + b.n 444fe │ │ │ │ + ldr r0, [pc, #48] @ (445dc ) │ │ │ │ add r0, pc │ │ │ │ - blx 3464 │ │ │ │ + blx 340c │ │ │ │ ldr r2, [r4, #24] │ │ │ │ movs r0, #0 │ │ │ │ - b.n 444aa │ │ │ │ + b.n 44432 │ │ │ │ ldr.w fp, [sp, #40] @ 0x28 │ │ │ │ - b.n 445ac │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 44534 │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop │ │ │ │ nop.w │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ adds r3, #51 @ 0x33 │ │ │ │ subs r7, #211 @ 0xd3 │ │ │ │ - subs r4, #58 @ 0x3a │ │ │ │ + subs r4, #178 @ 0xb2 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - subs r4, #18 │ │ │ │ + subs r4, #138 @ 0x8a │ │ │ │ movs r1, r0 │ │ │ │ - strh r4, [r6, #44] @ 0x2c │ │ │ │ + strh r0, [r2, #62] @ 0x3e │ │ │ │ movs r0, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d10} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3704] @ 0xe78 │ │ │ │ vldr s15, [r1, #24] │ │ │ │ vmov.f64 d10, #96 @ 0x3f000000 0.5 │ │ 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#332 @ 0x14c │ │ │ │ vpop {d8-d10} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ mov r4, r1 │ │ │ │ ldr r1, [r1, #64] @ 0x40 │ │ │ │ vmov.f64 d8, d0 │ │ │ │ - bl 9e8c │ │ │ │ + bl 9d54 │ │ │ │ str r0, [sp, #44] @ 0x2c │ │ │ │ ldr r7, [r4, #8] │ │ │ │ vmov s15, r7 │ │ │ │ ldr r2, [r4, #24] │ │ │ │ ldr r3, [r4, #0] │ │ │ │ vcvt.f64.s32 d6, s15 │ │ │ │ vmov.f64 d7, d10 │ │ │ │ @@ -75670,50 +75661,50 @@ │ │ │ │ vmla.f64 d7, d6, d10 │ │ │ │ vcvt.s32.f64 s13, d8 │ │ │ │ vmov r5, s13 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ mov r0, r5 │ │ │ │ vmov r9, s15 │ │ │ │ add r9, r3 │ │ │ │ - bl 4933c │ │ │ │ + bl 492c4 │ │ │ │ subs r3, r5, r1 │ │ │ │ vmov s18, r3 │ │ │ │ vldr d6, [r4, #16] │ │ │ │ mov r0, r7 │ │ │ │ vcvt.f64.s32 d9, s18 │ │ │ │ ldr r7, [sp, #24] │ │ │ │ lsls r1, r7, #1 │ │ │ │ vsub.f64 d9, d8, d9 │ │ │ │ vdiv.f64 d7, d9, d6 │ │ │ │ vsub.f64 d8, d8, d9 │ │ │ │ vadd.f64 d7, d7, d10 │ │ │ │ vcvt.s32.f64 s15, d7 │ │ │ │ vmov r5, s15 │ │ │ │ - bl 490a8 │ │ │ │ + bl 49030 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ mul.w r3, r0, r2 │ │ │ │ vmov s14, r3 │ │ │ │ mls r0, r0, r7, r9 │ │ │ │ vcvt.f64.s32 d7, s14 │ │ │ │ subs r7, r0, r5 │ │ │ │ vsub.f64 d8, d8, d7 │ │ │ │ vcvt.s32.f64 s15, d8 │ │ │ │ vmov r0, s15 │ │ │ │ cmp r0, #0 │ │ │ │ - bge.w 448c4 │ │ │ │ + bge.w 4484c │ │ │ │ movw r3, #36000 @ 0x8ca0 │ │ │ │ adds r0, r0, r3 │ │ │ │ - bmi.n 44766 │ │ │ │ - cbz r5, 44772 │ │ │ │ + bmi.n 446ee │ │ │ │ + cbz r5, 446fa │ │ │ │ ldr r3, [sp, #24] │ │ │ │ add r0, r2 │ │ │ │ add r7, r3 │ │ │ │ mov r1, r2 │ │ │ │ str r2, [sp, #16] │ │ │ │ - bl 490a8 │ │ │ │ + bl 49030 │ │ │ │ ldr r2, [sp, #16] │ │ │ │ sxth.w r3, r9 │ │ │ │ strh.w r3, [sp, #56] @ 0x38 │ │ │ │ strh.w r3, [sp, #52] @ 0x34 │ │ │ │ add.w ip, r8, r6 │ │ │ │ ldrh r3, [r4, #4] │ │ │ │ add.w r9, sp, #52 @ 0x34 │ │ │ │ @@ -75727,88 +75718,88 @@ │ │ │ │ submi r1, r3, r1 │ │ │ │ uxtahpl r1, r1, r3 │ │ │ │ sxth r3, r3 │ │ │ │ cmp r7, ip │ │ │ │ sxth r1, r1 │ │ │ │ strh.w r3, [r9, #2] │ │ │ │ strh.w r1, [r9, #6] │ │ │ │ - bge.w 448da │ │ │ │ + bge.w 44862 │ │ │ │ mov.w sl, #32 │ │ │ │ add r3, sp, #308 @ 0x134 │ │ │ │ mov.w r8, #1 │ │ │ │ mov fp, sl │ │ │ │ str r3, [sp, #40] @ 0x28 │ │ │ │ str.w ip, [sp, #32] │ │ │ │ str r2, [sp, #28] │ │ │ │ - b.n 447e6 │ │ │ │ + b.n 4476e │ │ │ │ add r1, r6 │ │ │ │ strh r1, [r2, #6] │ │ │ │ ldr r3, [sp, #24] │ │ │ │ add.w r8, r8, #1 │ │ │ │ add r7, r3 │ │ │ │ ldr r3, [sp, #28] │ │ │ │ add r5, r3 │ │ │ │ ldr r3, [sp, #32] │ │ │ │ cmp r3, r7 │ │ │ │ - ble.n 448de │ │ │ │ + ble.n 44866 │ │ │ │ movw r3, #36000 @ 0x8ca0 │ │ │ │ cmp r5, r3 │ │ │ │ itt gt │ │ │ │ subgt.w r5, r5, #35840 @ 0x8c00 │ │ │ │ subgt r5, #160 @ 0xa0 │ │ │ │ subs.w fp, fp, #1 │ │ │ │ - beq.n 448ec │ │ │ │ + beq.n 44874 │ │ │ │ mov.w sl, r8, lsl #3 │ │ │ │ ldr r6, [r4, #4] │ │ │ │ add.w r2, r9, sl │ │ │ │ ldr r3, [r4, #12] │ │ │ │ sxth.w ip, r7 │ │ │ │ ldr r1, [r4, #32] │ │ │ │ mov r0, r5 │ │ │ │ strh.w ip, [r9, r8, lsl #3] │ │ │ │ strh r6, [r2, #2] │ │ │ │ and.w r3, r3, #1 │ │ │ │ strh.w ip, [r2, #4] │ │ │ │ uxth r6, r6 │ │ │ │ str r3, [sp, #20] │ │ │ │ str r2, [sp, #16] │ │ │ │ - bl 4933c │ │ │ │ + bl 492c4 │ │ │ │ ldrd r2, r3, [sp, #16] │ │ │ │ - cbz r1, 44838 │ │ │ │ + cbz r1, 447c0 │ │ │ │ ldrh r1, [r4, #28] │ │ │ │ cmp r3, #0 │ │ │ │ - bne.n 447d0 │ │ │ │ + bne.n 44758 │ │ │ │ subs r6, r6, r1 │ │ │ │ strh r6, [r2, #6] │ │ │ │ - b.n 447d4 │ │ │ │ + b.n 4475c │ │ │ │ ldrh r2, [r4, #36] @ 0x24 │ │ │ │ cmp r3, #0 │ │ │ │ - beq.n 448be │ │ │ │ + beq.n 44846 │ │ │ │ adds r3, r2, r6 │ │ │ │ sxth r3, r3 │ │ │ │ vmov s15, r5 │ │ │ │ vldr d6, [r4, #48] @ 0x30 │ │ │ │ add.w r2, r9, sl │ │ │ │ ldr r6, [sp, #40] @ 0x28 │ │ │ │ vcvt.f64.s32 d7, s15 │ │ │ │ ldr r1, [r4, #56] @ 0x38 │ │ │ │ mov r0, r6 │ │ │ │ strh r3, [r2, #6] │ │ │ │ vdiv.f64 d7, d7, d6 │ │ │ │ vmov r2, r3, d7 │ │ │ │ - blx 35fc │ │ │ │ + blx 3598 │ │ │ │ ldrb.w r3, [sp, #308] @ 0x134 │ │ │ │ cmp r3, #32 │ │ │ │ - bne.n 44900 │ │ │ │ + bne.n 44888 │ │ │ │ ldrb.w r3, [r6, #1]! │ │ │ │ cmp r3, #32 │ │ │ │ - beq.n 4486e │ │ │ │ + beq.n 447f6 │ │ │ │ mov r0, r6 │ │ │ │ add sl, r9 │ │ │ │ - blx 321c │ │ │ │ + blx 31d4 │ │ │ │ ldr r3, [sp, #44] @ 0x2c │ │ │ │ ldr.w ip, [r4, #64] @ 0x40 │ │ │ │ ldrh.w r2, [sl, #6] │ │ │ │ mul.w r1, r0, r3 │ │ │ │ ldr r3, [r4, #12] │ │ │ │ strd r0, ip, [sp] │ │ │ │ lsls r3, r3, #31 │ │ │ │ @@ -75822,724 +75813,724 @@ │ │ │ │ sxthmi r2, r3 │ │ │ │ str r0, [sp, #8] │ │ │ │ mov r3, r6 │ │ │ │ ldr r0, [sp, #36] @ 0x24 │ │ │ │ sxth r1, r1 │ │ │ │ it pl │ │ │ │ sxthpl r2, r2 │ │ │ │ - bl 9eb8 │ │ │ │ + bl 9d80 │ │ │ │ ldr r3, [r4, #24] │ │ │ │ str r3, [sp, #28] │ │ │ │ - b.n 447d4 │ │ │ │ + b.n 4475c │ │ │ │ subs r3, r6, r2 │ │ │ │ sxth r3, r3 │ │ │ │ - b.n 44842 │ │ │ │ + b.n 447ca │ │ │ │ movw r3, #35999 @ 0x8c9f │ │ │ │ cmp r0, r3 │ │ │ │ - ble.w 4476a │ │ │ │ + ble.w 446f2 │ │ │ │ sub.w r0, r0, #35840 @ 0x8c00 │ │ │ │ subs r0, #160 @ 0xa0 │ │ │ │ cmp r0, r3 │ │ │ │ - bgt.n 448ce │ │ │ │ - b.n 4476a │ │ │ │ + bgt.n 44856 │ │ │ │ + b.n 446f2 │ │ │ │ mov.w r8, #1 │ │ │ │ ldrh r3, [r4, #60] @ 0x3c │ │ │ │ mov r2, r8 │ │ │ │ ldr r0, [sp, #36] @ 0x24 │ │ │ │ mov r1, r9 │ │ │ │ - bl 9e84 │ │ │ │ - b.n 446ac │ │ │ │ - ldr r2, [pc, #36] @ (44914 ) │ │ │ │ + bl 9d4c │ │ │ │ + b.n 44634 │ │ │ │ + ldr r2, [pc, #36] @ (4489c ) │ │ │ │ movs r3, #32 │ │ │ │ - ldr r0, [pc, #36] @ (44918 ) │ │ │ │ + ldr r0, [pc, #36] @ (448a0 ) │ │ │ │ movs r1, #216 @ 0xd8 │ │ │ │ add r2, pc │ │ │ │ add r0, pc │ │ │ │ - bl 12824 │ │ │ │ - blx 2f44 │ │ │ │ + bl 12f94 │ │ │ │ + blx 2ef4 │ │ │ │ ldr r6, [sp, #40] @ 0x28 │ │ │ │ - b.n 44876 │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ - subs r1, #122 @ 0x7a │ │ │ │ + b.n 447fe │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ + subs r1, #242 @ 0xf2 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - subs r1, #76 @ 0x4c │ │ │ │ + subs r1, #196 @ 0xc4 │ │ │ │ movs r1, r0 │ │ │ │ - strh r4, [r4, #24] │ │ │ │ + strh r0, [r0, #42] @ 0x2a │ │ │ │ movs r0, r0 │ │ │ │ - strh r2, [r7, #24] │ │ │ │ + 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#8192 @ 0x2000 │ │ │ │ ldr.w r3, [r6, #472] @ 0x1d8 │ │ │ │ - cbz r3, 44d62 │ │ │ │ + cbz r3, 44cea │ │ │ │ movs r2, #1 │ │ │ │ str r2, [r3, #4] │ │ │ │ pop {r4, r5, r6, pc} │ │ │ │ - ldr r3, [pc, #92] @ (44dc0 ) │ │ │ │ + ldr r3, [pc, #92] @ (44d48 ) │ │ │ │ add r3, pc │ │ │ │ ldr r4, [r3, #0] │ │ │ │ - cbz r4, 44da4 │ │ │ │ + cbz r4, 44d2c │ │ │ │ ldr r2, [r4, #0] │ │ │ │ str r2, [r3, #0] │ │ │ │ - ldr r5, [pc, #84] @ (44dc4 ) │ │ │ │ + ldr r5, [pc, #84] @ (44d4c ) │ │ │ │ movs r3, #1 │ │ │ │ movs r1, #32 │ │ │ │ str r3, [r4, #4] │ │ │ │ mov.w r2, #800 @ 0x320 │ │ │ │ add.w r0, r4, #16 │ │ │ │ - blx 3084 │ │ │ │ + blx 3038 │ │ │ │ add r5, pc │ │ │ │ movs r1, #84 @ 0x54 │ │ │ │ movs r3, #0 │ │ │ │ strd r3, r3, [r4, #8] │ │ │ │ str.w r3, [r4, #868] @ 0x364 │ │ │ │ str.w r4, [r6, #472] @ 0x1d8 │ │ │ │ mov r0, r4 │ │ │ │ - bl 44c28 │ │ │ │ + bl 44bb0 │ │ │ │ ldrb.w r1, [r5, #1]! │ │ │ │ cmp r1, #0 │ │ │ │ - bne.n 44d94 │ │ │ │ + bne.n 44d1c │ │ │ │ pop {r4, r5, r6, pc} │ │ │ │ - ldr r0, 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r0, #0 │ │ │ │ it ne │ │ │ │ movne r0, #1 │ │ │ │ bx lr │ │ │ │ add.w r3, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r3, [r3, #472] @ 0x1d8 │ │ │ │ - cbz r3, 44e08 │ │ │ │ + cbz r3, 44d90 │ │ │ │ ldr r2, [r3, #4] │ │ │ │ - cbz r2, 44e08 │ │ │ │ + cbz r2, 44d90 │ │ │ │ movs r2, #0 │ │ │ │ str r2, [r3, #4] │ │ │ │ bx lr │ │ │ │ - b.w 44d44 │ │ │ │ + b.w 44ccc │ │ │ │ push {r3, r4, r5, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #4080] @ 0xff0 │ │ │ │ add.w r0, r0, #8192 @ 0x2000 │ │ │ │ ldr.w r4, [r0, #472] @ 0x1d8 │ │ │ │ - cbz r4, 44e44 │ │ │ │ + cbz r4, 44dcc │ │ │ │ ldr r2, [r4, #4] │ │ │ │ - cbz r2, 44e44 │ │ │ │ + cbz r2, 44dcc │ │ │ │ sub.w r2, r1, #32 │ │ │ │ cmp r1, #13 │ │ │ │ it ne │ │ │ │ cmpne r2, #94 @ 0x5e │ │ │ │ - bhi.n 44e46 │ │ │ │ + bhi.n 44dce │ │ │ │ ldr.w r2, [r4, #868] @ 0x364 │ │ │ │ cmp r2, #49 @ 0x31 │ │ │ │ - bgt.n 44e44 │ │ │ │ + bgt.n 44dcc │ │ │ │ cmp r1, #13 │ │ │ │ - beq.n 44e88 │ │ │ │ + beq.n 44e10 │ │ │ │ cmp r2, #49 @ 0x31 │ │ │ │ - bne.n 44eac │ │ │ │ + bne.n 44e34 │ │ │ │ pop {r3, r4, r5, pc} │ │ │ │ cmp r1, #10 │ │ │ │ - beq.n 44e80 │ │ │ │ + beq.n 44e08 │ │ │ │ cmp r1, #127 @ 0x7f │ │ │ │ it ne │ │ │ │ cmpne r1, #8 │ │ │ │ - bne.n 44e44 │ │ │ │ + bne.n 44dcc │ │ │ │ ldr.w r3, [r4, #868] @ 0x364 │ │ │ │ cmp r3, #0 │ │ │ │ - ble.n 44e44 │ │ │ │ + ble.n 44dcc │ │ │ │ subs r3, #1 │ │ │ │ adds r2, r4, r3 │ │ │ │ ldrb.w r2, [r2, #816] @ 0x330 │ │ │ │ cmp r2, #0 │ │ │ │ - beq.n 44e44 │ │ │ │ - ldr r5, [pc, #88] @ (44ec0 ) │ │ │ │ + beq.n 44dcc │ │ │ │ + ldr r5, [pc, #88] @ (44e48 ) │ │ │ │ movs r1, #8 │ │ │ │ str.w r3, [r4, #868] @ 0x364 │ │ │ │ add r5, pc │ │ │ │ mov r0, r4 │ │ │ │ - bl 44c28 │ │ │ │ + bl 44bb0 │ │ │ │ ldrb.w r1, [r5, #1]! │ │ │ │ cmp r1, #0 │ │ │ │ - bne.n 44e70 │ │ │ │ + bne.n 44df8 │ │ │ │ pop {r3, r4, r5, pc} │ │ │ │ ldr.w r2, [r4, #868] @ 0x364 │ │ │ │ cmp r2, #49 @ 0x31 │ │ │ │ - bgt.n 44e44 │ │ │ │ + bgt.n 44dcc │ │ │ │ adds r3, r4, r2 │ │ │ │ - ldr r5, [pc, #56] @ (44ec4 ) │ │ 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(45474 ) │ │ │ │ + bgt.n 4528a │ │ │ │ + ldr r2, [pc, #448] @ (453fc ) │ │ │ │ vmov.f64 d7, #96 @ 0x3f000000 0.5 │ │ │ │ - ldr r3, [pc, #448] @ (45478 ) │ │ │ │ + ldr r3, [pc, #448] @ (45400 ) │ │ │ │ add r2, pc │ │ │ │ vldr d6, [r2] │ │ │ │ ldr r1, [r5, r3] │ │ │ │ vmul.f64 d7, d6, d7 │ │ │ │ vldr d5, [r1] │ │ │ │ vmul.f64 d7, d7, d6 │ │ │ │ vadd.f64 d5, d5, d6 │ │ │ │ - ldr r2, [pc, #424] @ (4547c ) │ │ │ │ - ldr r3, [pc, #428] @ (45480 ) │ │ │ │ + ldr r2, [pc, #424] @ (45404 ) │ │ │ │ + ldr r3, [pc, #428] @ (45408 ) │ │ │ │ vstr d5, [r1] │ │ │ │ ldr r2, [r5, r2] │ │ │ │ vstr d6, [r2] │ │ │ │ ldr r3, [r5, r3] │ │ │ │ - ldr r2, [pc, #416] @ (45484 ) │ │ │ │ + ldr r2, [pc, #416] @ (4540c ) │ │ │ │ add r2, pc │ │ │ │ vstr d7, [r3] │ │ │ │ - ldr r3, [pc, #380] @ (45468 ) │ │ │ │ + ldr r3, [pc, #380] @ (453f0 ) │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #28] │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.w 45426 │ │ │ │ + bne.w 453ae │ │ │ │ add sp, #36 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#568] @ (456b0 ) │ │ │ │ ldr r3, [r5, r3] │ │ │ │ strd r0, r1, [r3] │ │ │ │ movs r0, #0 │ │ │ │ - ldr r3, [pc, #560] @ (4572c ) │ │ │ │ + ldr r3, [pc, #560] @ (456b4 ) │ │ │ │ movs r1, #0 │ │ │ │ ldr.w fp, [r5, r3] │ │ │ │ strd r0, r1, [fp] │ │ │ │ - bl 14fd0 │ │ │ │ - ldr r3, [pc, #548] @ (45730 ) │ │ │ │ + bl 14f58 │ │ │ │ + ldr r3, [pc, #548] @ (456b8 ) │ │ │ │ str r0, [sp, #4] │ │ │ │ ldr r4, [r5, r3] │ │ │ │ ldr r3, [r4, #0] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.w 456ac │ │ │ │ - ldr r3, [pc, #540] @ (45734 ) │ │ │ │ - ldr.w r9, [pc, #540] @ 45738 │ │ │ │ - vldr d8, [pc, #480] @ 45700 │ │ │ │ - vldr d9, [pc, #484] @ 45708 │ │ │ │ + beq.w 45634 │ │ │ │ + ldr r3, [pc, #540] @ (456bc ) │ │ │ │ + ldr.w r9, [pc, #540] @ 456c0 │ │ │ │ + vldr d8, [pc, #480] @ 45688 │ │ │ │ + vldr d9, [pc, #484] @ 45690 │ │ │ │ add r9, pc │ │ │ │ ldr.w r8, [r5, r3] │ │ │ │ - ldr r3, [pc, #528] @ (4573c ) │ │ │ │ + ldr r3, [pc, #528] @ (456c4 ) │ │ │ │ ldr r6, [r5, r3] │ │ │ │ - ldr r3, [pc, #528] @ (45740 ) │ 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│ │ │ + bl 25674 │ │ │ │ + b.n 45574 │ │ │ │ add.w r5, r5, #4416 @ 0x1140 │ │ │ │ cmp r5, sl │ │ │ │ - beq.n 45600 │ │ │ │ + beq.n 45588 │ │ │ │ ldr r3, [r5, #16] │ │ │ │ cmp r3, #0 │ │ │ │ - beq.n 455e4 │ │ │ │ + beq.n 4556c │ │ │ │ mov r0, r5 │ │ │ │ add.w r5, r5, #4416 @ 0x1140 │ │ │ │ - bl 40738 │ │ │ │ + bl 406c0 │ │ │ │ cmp r5, sl │ │ │ │ - bne.n 455ec │ │ │ │ + bne.n 45574 │ │ │ │ ldr.w r3, [r9, #40] @ 0x28 │ │ │ │ adds r3, #1 │ │ │ │ str.w r3, [r9, #40] @ 0x28 │ │ │ │ - bl 4249c │ │ │ │ - bl 25a50 │ │ │ │ - bl 22d74 │ │ │ │ + bl 42424 │ │ │ │ + bl 259d8 │ │ │ │ + bl 22cfc │ │ │ │ vldr d7, [r9, #24] │ │ │ │ vldr d5, [r9, #48] @ 0x30 │ │ │ │ ldr.w r3, [r9, #40] @ 0x28 │ │ │ │ vsub.f64 d5, d7, d5 │ │ │ │ cmp r3, #1 │ │ │ │ - ble.n 45696 │ │ │ │ + ble.n 4561e │ │ │ │ vcmpe.f64 d5, d9 │ │ │ │ vmrs APSR_nzcv, fpscr │ │ │ │ - blt.n 45696 │ │ │ │ + blt.n 4561e │ │ │ │ vmov s13, r3 │ │ │ │ vstr d7, [r9, #48] @ 0x30 │ │ │ │ vmov.f64 d3, #96 @ 0x3f000000 0.5 │ │ │ │ movs r3, #0 │ │ │ │ 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) │ │ │ │ + ldr r3, [pc, #108] @ (456a4 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #124] @ 0x7c │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.n 456f8 │ │ │ │ + bne.n 45680 │ │ │ │ ldr r0, [sp, #4] │ │ │ │ add sp, #132 @ 0x84 │ │ │ │ vpop {d8-d10} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ - b.w 13b48 │ │ │ │ + b.w 13c20 │ │ │ │ vldr d0, [fp] │ │ │ │ - bl 28084 │ │ │ │ - b.n 4556a │ │ │ │ - ldr r2, [pc, #116] @ (45750 ) │ │ │ │ + bl 2800c │ │ │ │ + b.n 454f2 │ │ │ │ + ldr r2, [pc, #116] @ (456d8 ) │ │ │ │ add r5, sp, #24 │ │ │ │ movs r1, #99 @ 0x63 │ │ │ │ mov r0, r5 │ │ │ │ add r2, pc │ │ │ │ - blx 34f4 │ │ │ │ + blx 349c │ │ │ │ mov r0, r5 │ │ │ │ - bl 40318 │ │ │ │ + bl 402a0 │ │ │ │ vldr d8, [fp] │ │ │ │ vadd.f64 d8, d8, d10 │ │ │ │ - b.n 45696 │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 4561e │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ nop.w │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ movs r0, r0 │ │ │ │ eors r6, r1 │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ subs r7, #201 @ 0xc9 │ │ │ │ pop {r0, r1, r2, r3, r4, r6, r7} │ │ │ │ ldrb r2, [r3, #2] │ │ │ │ adds r4, #86 @ 0x56 │ │ │ │ subs r7, #34 @ 0x22 │ │ │ │ - cmp r3, #72 @ 0x48 │ │ │ │ + cmp r3, #192 @ 0xc0 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - cmp r3, #52 @ 0x34 │ │ │ │ + cmp r3, #172 @ 0xac │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r0, #10 │ │ │ │ + lsls r0, r7, #9 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r1, #10 │ │ │ │ + lsls r4, r0, #10 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r1, #12 │ │ │ │ + lsls r0, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r0, r5, #11 │ │ │ │ + lsls r0, r4, #11 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r3, #12 │ │ │ │ + lsls r4, r2, #12 │ │ │ │ movs r0, r0 │ │ │ │ - asrs r0, r5, #26 │ │ │ │ + asrs r0, r1, #26 │ │ │ │ movs r6, r0 │ │ │ │ - lsls r0, r4, #10 │ │ │ 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r0, [r4, #36] @ 0x24 │ │ │ │ - bl 13b48 │ │ │ │ + bl 13c20 │ │ │ │ ldr r0, [r4, #32] │ │ │ │ - bl 13b48 │ │ │ │ + bl 13c20 │ │ │ │ ldr r0, [r4, #20] │ │ │ │ - bl 13b48 │ │ │ │ + bl 13c20 │ │ │ │ ldr r2, [r4, #12] │ │ │ │ ldr r3, [r2, #68] @ 0x44 │ │ │ │ cmp r3, r4 │ │ │ │ itt eq │ │ │ │ ldreq r3, [r4, #4] │ │ │ │ streq r3, [r2, #68] @ 0x44 │ │ │ │ - beq.n 4586c │ │ │ │ + beq.n 457f4 │ │ │ │ mov r2, r3 │ │ │ │ ldr r3, [r3, #4] │ │ │ │ cmp r3, r4 │ │ │ │ - bne.n 45860 │ │ │ │ + bne.n 457e8 │ │ │ │ ldr r3, [r4, #4] │ │ │ │ str r3, [r2, #4] │ │ │ │ - ldr r3, [pc, #32] @ (45890 ) │ │ │ │ + ldr r3, [pc, #32] @ (45818 ) │ │ │ │ ldr r1, [r4, #0] │ │ │ │ ldr r2, [r5, r3] │ │ │ │ ldr r3, [r2, #0] │ │ │ │ cmp r3, r4 │ │ │ │ - beq.n 45880 │ │ │ │ + beq.n 45808 │ │ │ │ mov r2, r3 │ │ │ │ ldr r3, [r3, #0] │ │ │ │ cmp r3, r4 │ │ │ │ - bne.n 45878 │ │ │ │ + bne.n 45800 │ │ │ │ mov r0, r4 │ │ │ │ str r1, [r2, #0] │ │ │ │ ldmia.w sp!, {r4, r5, r6, lr} │ │ │ │ - b.w 13b48 │ │ │ │ - movs r7, #238 @ 0xee │ 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r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - movs r3, #188 @ 0xbc │ │ │ │ + movs r4, #52 @ 0x34 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r4, r1, #12 │ │ │ │ + lsls r4, r0, #12 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r5, #9 │ │ │ │ + lsls r4, r4, #9 │ │ │ │ movs r0, r0 │ │ │ │ - lsls r4, r1, #11 │ │ │ │ + lsls r4, r0, #11 │ │ │ │ movs r0, r0 │ │ │ │ - movs r2, #130 @ 0x82 │ │ │ │ + movs r2, #250 @ 0xfa │ │ │ │ movs r1, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3968] @ 0xf80 │ │ │ │ - ldr r4, [pc, #280] @ (45ef4 ) │ │ │ │ + ldr r4, [pc, #280] @ (45e7c ) │ │ │ │ mov sl, r0 │ │ │ │ - ldr r0, [pc, #280] @ (45ef8 ) │ │ │ │ + ldr r0, [pc, #280] @ (45e80 ) │ │ │ │ mov r7, r1 │ │ │ │ add r4, pc │ │ │ │ sub sp, #84 @ 0x54 │ │ │ │ ldr.w r1, [sl, #4] │ │ │ │ ldr r0, [r4, r0] │ │ │ │ cmp r1, #0 │ │ │ │ ldr r0, [r0, #0] │ │ │ │ str r0, [sp, #76] @ 0x4c │ │ │ │ mov.w r0, #0 │ │ │ │ - ble.n 45ed2 │ │ │ │ + ble.n 45e5a │ │ │ │ add.w r8, sp, #24 │ │ │ │ mov.w fp, #0 │ │ │ │ add r6, sp, #48 @ 0x30 │ │ │ │ mov r4, sl │ │ │ │ mov.w r9, #24 │ │ │ │ mov sl, r8 │ │ │ │ mov r5, fp │ │ │ │ @@ -77826,44 +77817,44 @@ │ │ │ │ vmov.f64 d8, #96 @ 0x3f000000 0.5 │ │ │ │ strd r2, r3, [sp, #16] │ │ │ │ ldr r3, [r4, #8] │ │ │ │ mov r2, sl │ │ │ │ mov r1, r8 │ │ │ │ ldr.w r6, [r3, r5, lsl #2] │ │ │ │ ldr r0, [r6, #8] │ │ │ │ - bl b264 │ │ │ │ + bl b394 │ │ │ │ ldr r3, [r6, #4] │ │ │ │ cmp r3, #1 │ │ │ │ - ble.n 45eca │ │ │ │ + ble.n 45e52 │ │ │ │ mov.w fp, #1 │ │ │ │ str r5, [sp, #12] │ │ │ │ - b.n 45e52 │ │ │ │ + b.n 45dda │ │ │ │ mov ip, r7 │ │ │ │ mov r5, sl │ │ │ │ ldr.w lr, [r6, #4] │ │ │ │ add.w fp, fp, #1 │ │ │ │ ldmia.w ip!, {r0, r1, r2, r3} │ │ │ │ stmia r5!, {r0, r1, r2, r3} │ │ │ │ cmp lr, fp │ │ │ │ ldmia.w ip, {r0, r1} │ │ │ │ stmia.w r5, {r0, r1} │ │ │ │ - ble.n 45ec8 │ │ │ │ + ble.n 45e50 │ │ │ │ ldr r0, [r6, #8] │ │ │ │ mov r2, r7 │ │ │ │ mov r1, r8 │ │ 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(45ef8 ) │ │ │ │ + bgt.n 45d9e │ │ │ │ + ldr r2, [pc, #40] @ (45e84 ) │ │ │ │ + ldr r3, [pc, #32] @ (45e80 ) │ │ │ │ add r2, pc │ │ │ │ ldr r3, [r2, r3] │ │ │ │ ldr r2, [r3, #0] │ │ │ │ ldr r3, [sp, #76] @ 0x4c │ │ │ │ eors r2, r3 │ │ │ │ mov.w r3, #0 │ │ │ │ - bne.n 45ef0 │ │ │ │ + bne.n 45e78 │ │ │ │ add sp, #84 @ 0x54 │ │ │ │ vpop {d8} │ │ │ │ ldmia.w sp!, {r4, r5, r6, r7, r8, r9, sl, fp, pc} │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ - movs r2, #28 │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ + movs r2, #148 @ 0x94 │ │ │ │ movs r1, r0 │ │ │ │ - lsls r0, r3, #11 │ │ │ │ + lsls r0, r2, #11 │ │ │ │ movs r0, r0 │ │ │ │ - movs r1, #38 @ 0x26 │ │ │ │ + movs r1, #158 @ 0x9e │ │ │ │ movs r1, r0 │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, r9, sl, fp, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ vpush {d8-d14} │ │ │ │ sub.w ip, sp, ip │ │ │ │ str.w r0, [ip, #3920] @ 0xf50 │ │ │ │ - ldr r4, [pc, #528] @ (46128 ) │ │ │ │ + ldr r4, [pc, #528] @ (460b0 ) │ │ │ │ mov fp, r0 │ │ │ │ - ldr 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(adr r3, 467c8 ) │ │ │ │ ldrd r2, r3, [r3] │ │ │ │ add r1, sp, #24 │ │ │ │ ldr r0, [r4, #16] │ │ │ │ strd r2, r3, [sp, #24] │ │ │ │ strd r6, r7, [sp, #40] @ 0x28 │ │ │ │ strd sl, fp, [sp, #32] │ │ │ │ - bl 459c4 │ │ │ │ - add r3, pc, #68 @ (adr r3, 46848 ) │ │ │ │ + bl 4594c │ │ │ │ + add r3, pc, #68 @ (adr r3, 467d0 ) │ │ │ │ ldrd r2, r3, [r3] │ │ │ │ add r1, sp, #48 @ 0x30 │ │ │ │ ldr r0, [r4, #16] │ │ │ │ strd r2, r3, [sp, #48] @ 0x30 │ │ │ │ strd sl, fp, [sp, #56] @ 0x38 │ │ │ │ strd r6, r7, [sp, #64] @ 0x40 │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ ldr r0, [r4, #16] │ │ │ │ add r1, sp, #72 @ 0x48 │ │ │ │ strd r6, r7, [sp, #72] @ 0x48 │ │ │ │ strd r8, r9, [sp, #80] @ 0x50 │ │ │ │ strd r6, r7, [sp, #88] @ 0x58 │ │ │ │ - bl 459c4 │ │ │ │ + bl 4594c │ │ │ │ ldr r0, [r4, #16] │ │ │ │ - b.n 4679e │ │ │ │ - blx 33b8 <__stack_chk_fail@plt> │ │ │ │ + b.n 46726 │ │ │ │ + blx 3370 <__stack_chk_fail@plt> │ │ │ │ ldr r1, [sp, #616] @ 0x268 │ │ │ │ ldr r1, [sp, #612] @ 0x264 │ │ │ │ ldr r1, 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ldr r3, [pc, #12] @ (46868 ) │ │ │ │ add r3, pc │ │ │ │ ldr.w r0, [r3, r0, lsl #2] │ │ │ │ bx lr │ │ │ │ movs r0, #0 │ │ │ │ bx lr │ │ │ │ nop │ │ │ │ - asrs r6, r0, #24 │ │ │ │ + asrs r6, r7, #25 │ │ │ │ movs r1, r0 │ │ │ │ ldr.w r2, [r0, #812] @ 0x32c │ │ │ │ mov r3, r0 │ │ │ │ movs r0, #0 │ │ │ │ ldr.w r2, [r2, #840] @ 0x348 │ │ │ │ cmp r2, #0 │ │ │ │ - ble.n 4690a │ │ │ │ + ble.n 46892 │ │ │ │ add.w ip, r3, r2, lsl #5 │ │ │ │ ldr.w r2, [r3, #3976] @ 0xf88 │ │ │ │ adds r3, #32 │ │ │ │ cmp r1, r2 │ │ │ │ it eq │ │ │ │ addeq r0, #1 │ │ │ │ cmp ip, r3 │ │ │ │ - bne.n 468f8 │ │ │ │ + bne.n 46880 │ │ │ │ bx lr │ │ │ │ bx lr │ │ │ │ ldr.w r2, [r0, #812] @ 0x32c │ │ │ │ push {r4} │ │ │ │ ldr.w r4, [r2, #840] @ 0x348 │ │ │ │ cmp r4, #0 │ │ │ │ - ble.n 46936 │ │ │ │ + ble.n 468be │ │ │ │ mov r3, r0 │ │ │ │ movs r0, #0 │ │ │ │ - b.n 46926 │ │ │ │ + b.n 468ae │ │ │ │ adds r0, #1 │ │ │ │ cmp r0, r4 │ │ │ │ - beq.n 46936 │ │ │ │ + beq.n 468be │ │ │ │ ldr.w r2, [r3, #3976] @ 0xf88 │ │ │ │ adds r3, #32 │ │ │ │ cmp r2, r1 │ │ │ │ - bne.n 46920 │ │ │ │ + bne.n 468a8 │ │ │ │ ldr.w r4, [sp], #4 │ │ │ │ bx lr │ │ │ │ mov.w r0, #4294967295 @ 0xffffffff │ │ │ │ ldr.w r4, [sp], #4 │ │ │ │ bx lr │ │ │ │ stmdb sp!, {r4, r5, r6, r7, r8, lr} │ │ │ │ mov.w ip, #4096 @ 0x1000 │ │ │ │ @@ -78807,146 +78798,146 @@ │ │ │ │ adds r3, r6, #1 │ │ │ │ asrs r4, r3, #31 │ │ │ │ smull r1, r2, r7, r3 │ │ │ │ rsb r4, r4, r2, asr #1 │ │ │ │ add.w r4, r4, r4, lsl #2 │ │ │ │ subs r4, r3, r4 │ │ │ │ cmp r6, r4 │ │ │ │ - beq.n 469d6 │ │ │ │ + beq.n 4695e │ │ │ │ mov r5, r0 │ │ │ │ - cbz r4, 469ca │ │ │ │ - ldr.w r8, [pc, #100] @ 469dc │ │ │ │ + cbz r4, 46952 │ │ │ │ + ldr.w r8, [pc, #100] @ 46964 │ │ │ │ add r8, pc │ │ │ │ ldr.w r3, [r5, #812] @ 0x32c │ │ │ │ ldr.w r0, [r3, #840] @ 0x348 │ │ │ │ cmp r0, #0 │ │ │ │ itt gt │ │ │ │ movgt r3, r5 │ │ │ │ movgt r2, #0 │ │ │ │ - bgt.n 46994 │ │ │ │ - b.n 469b0 │ │ │ │ + bgt.n 4691c │ │ │ │ + b.n 46938 │ │ │ │ cmp r2, r0 │ │ │ │ - beq.n 469b0 │ │ │ │ + beq.n 46938 │ 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r2, 48df0 ) │ │ │ │ add.w r3, r2, r3, lsl #4 │ │ │ │ mov.w r2, #0 │ │ │ │ mov pc, r3 │ │ │ │ nop │ │ │ │ nop.w │ │ │ │ cmp.w r0, r1, lsl #31 │ │ │ │ nop │ │ │ │ @@ -82351,45 +82345,45 @@ │ │ │ │ moveq r0, #1 │ │ │ │ movne r0, #0 │ │ │ │ bx lr │ │ │ │ clz r2, r1 │ │ │ │ rsb r2, r2, #31 │ │ │ │ lsr.w r0, r0, r2 │ │ │ │ bx lr │ │ │ │ - cbz r0, 49088 │ │ │ │ + cbz r0, 49010 │ │ │ │ mov.w r0, #4294967295 @ 0xffffffff │ │ │ │ - b.w 49770 │ │ │ │ + b.w 496f8 │ │ │ │ cmp r1, #0 │ │ │ │ - beq.n 49082 │ │ │ │ + beq.n 4900a │ │ │ │ stmdb sp!, {r0, r1, lr} │ │ │ │ - bl 48e30 │ │ │ │ + bl 48db8 │ │ │ │ ldmia.w sp!, {r1, r2, lr} │ │ │ │ mul.w r3, r2, r0 │ │ │ │ sub.w r1, r1, r3 │ │ │ │ bx lr │ │ │ │ nop │ │ │ │ cmp r1, #0 │ │ │ │ - beq.w 4932a │ │ │ │ + beq.w 492b2 │ │ │ │ eor.w ip, r0, r1 │ │ │ │ it mi │ │ │ │ negmi r1, r1 │ │ │ │ subs r2, r1, #1 │ │ │ │ - beq.w 492fa │ │ │ │ + beq.w 49282 │ │ │ │ movs r3, r0 │ │ │ │ it mi │ │ │ │ negmi r3, r0 │ │ │ │ cmp r3, r1 │ │ │ │ - bls.w 49304 │ │ │ │ + bls.w 4928c │ │ │ │ tst r1, r2 │ │ │ │ - beq.w 49314 │ │ │ │ + beq.w 4929c │ │ │ │ clz r2, r3 │ │ │ │ clz r0, r1 │ │ │ │ sub.w r2, r0, r2 │ │ │ │ rsb r2, r2, #31 │ │ │ │ - add r0, pc, #16 @ (adr r0, 490f0 ) │ │ │ │ + add r0, pc, #16 @ (adr r0, 49078 ) │ │ │ │ add.w r2, r0, r2, lsl #4 │ │ │ │ mov.w r0, #0 │ │ │ │ mov pc, r2 │ │ │ │ nop │ │ │ │ nop.w │ │ │ │ cmp.w r3, r1, lsl #31 │ │ │ │ nop │ │ │ │ @@ -82573,139 +82567,139 @@ │ │ │ │ negmi r0, r0 │ │ │ │ bx lr │ │ │ │ cmp r0, #0 │ │ │ │ it gt │ │ │ │ mvngt.w r0, #2147483648 @ 0x80000000 │ │ │ │ it lt │ │ │ │ movlt.w r0, #2147483648 @ 0x80000000 │ │ │ │ - b.w 49770 │ │ │ │ + b.w 496f8 │ │ │ │ cmp r1, #0 │ │ │ │ - beq.n 4932a │ │ │ │ + beq.n 492b2 │ │ │ │ stmdb sp!, {r0, r1, lr} │ │ │ │ - bl 490ae │ │ │ │ + bl 49036 │ │ │ │ ldmia.w sp!, {r1, r2, lr} │ │ │ │ mul.w r3, r2, r0 │ │ │ │ sub.w r1, r1, r3 │ │ │ │ bx lr │ │ │ │ nop │ │ │ │ eor.w r1, r1, #2147483648 @ 0x80000000 │ │ │ │ - b.n 49364 │ │ │ │ + b.n 492ec │ │ │ │ nop │ │ │ │ eor.w r3, r3, #2147483648 @ 0x80000000 │ │ │ │ push {r4, r5, lr} │ │ │ │ mov.w r4, r1, lsl #1 │ │ │ │ mov.w r5, r3, lsl #1 │ │ │ │ teq r4, r5 │ │ │ │ it eq │ │ │ │ teqeq r0, r2 │ │ │ │ itttt ne │ │ │ │ orrsne.w ip, r4, r0 │ │ │ │ orrsne.w ip, r5, r2 │ │ │ │ mvnsne.w ip, r4, asr #21 │ │ │ │ mvnsne.w ip, r5, asr #21 │ │ │ │ - beq.w 49552 │ │ │ │ + beq.w 494da │ │ │ │ mov.w r4, r4, lsr #21 │ │ │ │ rsbs r5, r4, r5, lsr #21 │ │ │ │ it lt │ │ │ │ neglt r5, r5 │ │ │ │ - ble.n 493b6 │ │ │ │ + ble.n 4933e │ │ │ │ add r4, r5 │ │ │ │ eor.w r2, r0, r2 │ │ │ │ eor.w r3, r1, r3 │ │ │ │ eor.w r0, r2, r0 │ │ │ │ eor.w r1, r3, r1 │ │ │ │ eor.w r2, r0, r2 │ │ │ │ eor.w r3, r1, r3 │ │ │ │ cmp r5, #54 @ 0x36 │ │ │ │ it hi │ │ │ │ pophi {r4, r5, pc} │ │ │ │ tst.w r1, #2147483648 @ 0x80000000 │ │ │ │ mov.w r1, r1, lsl #12 │ │ │ │ mov.w ip, #1048576 @ 0x100000 │ │ │ │ orr.w r1, ip, r1, lsr #12 │ │ │ │ - beq.n 493d4 │ │ │ │ + beq.n 4935c │ │ │ │ negs r0, r0 │ │ │ │ sbc.w r1, r1, r1, lsl #1 │ │ │ │ tst.w r3, #2147483648 @ 0x80000000 │ │ │ │ mov.w r3, r3, lsl #12 │ │ │ │ orr.w r3, ip, r3, lsr #12 │ │ │ │ - beq.n 493e8 │ │ │ │ + beq.n 49370 │ │ │ │ negs r2, r2 │ │ │ │ sbc.w r3, r3, r3, lsl #1 │ │ │ │ teq r4, r5 │ │ │ │ - beq.w 4953e │ │ │ │ + beq.w 494c6 │ │ │ │ sub.w r4, r4, #1 │ │ │ │ rsbs lr, r5, #32 │ │ │ │ - blt.n 49416 │ │ │ │ + blt.n 4939e │ │ │ │ lsl.w ip, r2, lr │ │ │ │ lsr.w r2, r2, r5 │ │ │ │ adds r0, r0, r2 │ │ │ │ adc.w r1, r1, #0 │ │ │ │ lsl.w r2, r3, lr │ │ │ │ adds r0, r0, r2 │ │ │ │ asr.w r3, r3, r5 │ │ │ │ adcs r1, r3 │ │ │ │ - b.n 49434 │ │ │ │ + b.n 493bc │ │ │ │ sub.w r5, r5, #32 │ │ │ │ add.w lr, lr, #32 │ │ │ │ cmp r2, #1 │ │ │ │ lsl.w ip, r3, lr │ │ │ │ it cs │ │ │ │ orrcs.w ip, ip, #2 │ │ │ │ asr.w r3, r3, r5 │ │ │ │ adds r0, r0, r3 │ │ │ │ adcs.w r1, r1, r3, asr #31 │ │ │ │ and.w r5, r1, #2147483648 @ 0x80000000 │ │ │ │ - bpl.n 4944a │ │ │ │ + bpl.n 493d2 │ │ │ │ mov.w lr, #0 │ │ │ │ rsbs ip, ip, #0 │ │ │ │ sbcs.w r0, lr, r0 │ │ │ │ sbc.w r1, lr, r1 │ │ │ │ cmp.w r1, #1048576 @ 0x100000 │ │ │ │ - bcc.n 49488 │ │ │ │ + bcc.n 49410 │ │ │ │ cmp.w r1, #2097152 @ 0x200000 │ │ │ │ - bcc.n 49470 │ │ │ │ + bcc.n 493f8 │ │ │ │ lsrs r1, r1, #1 │ │ │ │ movs.w r0, r0, rrx │ │ │ │ mov.w ip, ip, rrx │ │ │ │ add.w r4, r4, #1 │ │ │ │ mov.w r2, r4, lsl #21 │ │ │ │ cmn.w r2, #4194304 @ 0x400000 │ │ │ │ - bcs.w 495a4 │ │ │ │ + bcs.w 4952c │ │ │ │ cmp.w ip, #2147483648 @ 0x80000000 │ │ │ │ it eq │ │ │ │ movseq.w ip, r0, lsr #1 │ │ │ │ adcs.w r0, r0, #0 │ │ │ │ adc.w r1, r1, r4, lsl #20 │ │ │ │ orr.w r1, r1, r5 │ │ │ │ pop {r4, r5, pc} │ │ │ │ movs.w ip, ip, lsl #1 │ │ │ │ adcs r0, r0 │ │ │ │ adc.w r1, r1, r1 │ │ │ │ subs r4, #1 │ │ │ │ it cs │ │ │ │ cmpcs.w r1, #1048576 @ 0x100000 │ │ │ │ - bcs.n 49470 │ │ │ │ + bcs.n 493f8 │ │ │ │ teq r1, #0 │ │ │ │ itt eq │ │ │ │ moveq r1, r0 │ │ │ │ moveq r0, #0 │ │ │ │ clz r3, r1 │ │ │ │ it eq │ │ │ │ addeq r3, #32 │ │ │ │ sub.w r3, r3, #11 │ │ │ │ subs.w r2, r3, #32 │ │ │ │ - bge.n 494d2 │ │ │ │ + bge.n 4945a │ │ │ │ adds r2, #12 │ │ │ │ - ble.n 494ce │ │ │ │ + ble.n 49456 │ │ │ │ add.w ip, r2, #20 │ │ │ │ rsb r2, r2, #12 │ │ │ │ lsl.w r0, r1, ip │ │ │ │ lsr.w r1, r1, r2 │ │ │ │ - b.n 494e8 │ │ │ │ + b.n 49470 │ │ │ │ add.w r2, r2, #20 │ │ │ │ it le │ │ │ │ rsble ip, r2, #32 │ │ │ │ lsl.w r1, r1, r2 │ │ │ │ lsr.w ip, r0, ip │ │ │ │ itt le │ │ │ │ orrle.w r1, r1, ip │ │ │ │ @@ -82713,17 +82707,17 @@ │ │ │ │ subs r4, r4, r3 │ │ │ │ ittt ge │ │ │ │ addge.w r1, r1, r4, lsl #20 │ │ │ │ orrge r1, r5 │ │ │ │ popge {r4, r5, pc} │ │ │ │ mvn.w r4, r4 │ │ │ │ subs r4, #31 │ │ │ │ - bge.n 49536 │ │ │ │ + bge.n 494be │ │ │ │ adds r4, #12 │ │ │ │ - bgt.n 4951e │ │ │ │ + bgt.n 494a6 │ │ │ │ add.w r4, r4, #20 │ │ │ │ rsb r2, r4, #32 │ │ │ │ lsr.w r0, r0, r4 │ │ │ │ lsl.w r3, r1, r2 │ │ │ │ orr.w r0, r0, r3 │ │ │ │ lsr.w r3, r1, r4 │ │ │ │ orr.w r1, r5, r3 │ │ │ │ @@ -82740,35 +82734,35 @@ │ │ │ │ pop {r4, r5, pc} │ │ │ │ teq r4, #0 │ │ │ │ eor.w r3, r3, #1048576 @ 0x100000 │ │ │ │ itte eq │ │ │ │ eoreq.w r1, r1, #1048576 @ 0x100000 │ │ │ │ addeq r4, #1 │ │ │ │ subne r5, #1 │ │ │ │ - b.n 493f0 │ │ │ │ + b.n 49378 │ │ │ │ mvns.w ip, r4, asr #21 │ │ │ │ it ne │ │ │ │ mvnsne.w ip, r5, asr #21 │ │ │ │ - beq.n 495b2 │ │ │ │ + beq.n 4953a │ │ │ │ teq r4, r5 │ │ │ │ it eq │ │ │ │ teqeq r0, r2 │ │ │ │ - beq.n 49576 │ │ │ │ + beq.n 494fe │ │ │ │ orrs.w ip, r4, r0 │ │ │ │ itt eq │ │ │ │ moveq r1, r3 │ │ │ │ moveq r0, r2 │ │ │ │ pop {r4, r5, pc} │ │ │ │ teq r1, r3 │ │ │ │ ittt ne │ │ │ │ movne r1, #0 │ │ │ │ movne r0, #0 │ │ │ │ popne {r4, r5, pc} │ │ │ │ movs.w ip, r4, lsr #21 │ │ │ │ - bne.n 49594 │ │ │ │ + bne.n 4951c │ │ │ │ lsls r0, r0, #1 │ │ │ │ adcs r1, r1 │ │ │ │ it cs │ │ │ │ orrcs.w r1, r1, #2147483648 @ 0x80000000 │ │ │ │ pop {r4, r5, pc} │ │ │ │ adds.w r4, r4, #4194304 @ 0x400000 │ │ │ │ itt cc │ │ │ │ @@ -82799,28 +82793,28 @@ │ │ │ │ moveq r1, #0 │ │ │ │ bxeq lr │ │ │ │ push {r4, r5, lr} │ │ │ │ mov.w r4, #1024 @ 0x400 │ │ │ │ add.w r4, r4, #50 @ 0x32 │ │ │ │ mov.w r5, #0 │ │ │ │ mov.w r1, #0 │ │ │ │ - b.n 4949c │ │ │ │ + b.n 49424 │ │ │ │ nop │ │ │ │ teq r0, #0 │ │ │ │ itt eq │ │ │ │ moveq r1, #0 │ │ │ │ bxeq lr │ │ │ │ push {r4, r5, lr} │ │ │ │ mov.w r4, #1024 @ 0x400 │ │ │ │ add.w r4, r4, #50 @ 0x32 │ │ │ │ ands.w r5, r0, #2147483648 @ 0x80000000 │ │ │ │ it mi │ │ │ │ negmi r0, r0 │ │ │ │ mov.w r1, #0 │ │ │ │ - b.n 4949c │ │ │ │ + b.n 49424 │ │ │ │ nop │ │ │ │ lsls r2, r0, #1 │ │ │ │ mov.w r1, r2, asr #3 │ │ │ │ mov.w r1, r1, rrx │ │ │ │ mov.w r0, r2, lsl #28 │ │ │ │ itttt ne │ │ │ │ andsne.w r3, r2, #4278190080 @ 0xff000000 │ │ │ │ @@ -82834,34 +82828,34 @@ │ │ │ │ itt eq │ │ │ │ orreq.w r1, r1, #524288 @ 0x80000 │ │ │ │ bxeq lr │ │ │ │ push {r4, r5, lr} │ │ │ │ mov.w r4, #896 @ 0x380 │ │ │ │ and.w r5, r1, #2147483648 @ 0x80000000 │ │ │ │ bic.w r1, r1, #2147483648 @ 0x80000000 │ │ │ │ - b.n 4949c │ │ │ │ + b.n 49424 │ │ │ │ nop │ │ │ │ orrs.w r2, r0, r1 │ │ │ │ it eq │ │ │ │ bxeq lr │ │ │ │ push {r4, r5, lr} │ │ │ │ mov.w r5, #0 │ │ │ │ - b.n 4968a │ │ │ │ + b.n 49612 │ │ │ │ orrs.w r2, r0, r1 │ │ │ │ it eq │ │ │ │ bxeq lr │ │ │ │ push {r4, r5, lr} │ │ │ │ ands.w r5, r1, #2147483648 @ 0x80000000 │ │ │ │ - bpl.n 4968a │ │ │ │ + bpl.n 49612 │ │ │ │ negs r0, r0 │ │ │ │ sbc.w r1, r1, r1, lsl #1 │ │ │ │ mov.w r4, #1024 @ 0x400 │ │ │ │ add.w r4, r4, #50 @ 0x32 │ │ │ │ movs.w ip, r1, lsr #22 │ │ │ │ - beq.w 4944a │ │ │ │ + beq.w 493d2 │ │ │ │ mov.w r2, #3 │ │ │ │ movs.w ip, ip, lsr #3 │ │ │ │ it ne │ │ │ │ addne r2, #3 │ │ │ │ movs.w ip, ip, lsr #3 │ │ │ │ it ne │ │ │ │ addne r2, #3 │ │ │ │ @@ -82869,135 +82863,135 @@ │ │ │ │ rsb r3, r2, #32 │ │ │ │ lsl.w ip, r0, r3 │ │ │ │ lsr.w r0, r0, r2 │ │ │ │ lsl.w lr, r1, r3 │ │ │ │ orr.w r0, r0, lr │ │ │ │ lsr.w r1, r1, r2 │ │ │ │ add r4, r2 │ │ │ │ - b.n 4944a │ │ │ │ + b.n 493d2 │ │ │ │ nop │ │ │ │ - cbnz r3, 496f2 │ │ │ │ - cbnz r2, 496f2 │ │ │ │ + cbnz r3, 4967a │ │ │ │ + cbnz r2, 4967a │ │ │ │ cmp r1, #0 │ │ │ │ ittt lt │ │ │ │ movlt r0, #0 │ │ │ │ movlt.w r1, #2147483648 @ 0x80000000 │ │ │ │ - blt.n 496ee │ │ │ │ + blt.n 49676 │ │ │ │ it eq │ │ │ │ cmpeq r0, #0 │ │ │ │ itt ne │ │ │ │ mvnne.w r1, #2147483648 @ 0x80000000 │ │ │ │ movne.w r0, #4294967295 @ 0xffffffff │ │ │ │ - b.w 49770 │ │ │ │ + b.w 496f8 │ │ │ │ sub.w ip, sp, #8 │ │ │ │ strd ip, lr, [sp, #-16]! │ │ │ │ cmp r1, #0 │ │ │ │ - blt.n 49712 │ │ │ │ + blt.n 4969a │ │ │ │ cmp r3, #0 │ │ │ │ - blt.n 49738 │ │ │ │ - bl 4977c │ │ │ │ + blt.n 496c0 │ │ │ │ + bl 49704 │ │ │ │ ldr.w lr, [sp, #4] │ │ │ │ ldrd r2, r3, [sp, #8] │ │ │ │ add sp, #16 │ │ │ │ bx lr │ │ │ │ negs r0, r0 │ │ │ │ sbc.w r1, r1, r1, lsl #1 │ │ │ │ cmp r3, #0 │ │ │ │ - blt.n 49754 │ │ │ │ - bl 4977c │ │ │ │ + blt.n 496dc │ │ │ │ + bl 49704 │ │ │ │ ldr.w lr, [sp, #4] │ │ │ │ ldrd r2, r3, [sp, #8] │ │ │ │ add sp, #16 │ │ │ │ negs r0, r0 │ │ │ │ sbc.w r1, r1, r1, lsl #1 │ │ │ │ negs r2, r2 │ │ │ │ sbc.w r3, r3, r3, lsl #1 │ │ │ │ bx lr │ │ │ │ negs r2, r2 │ │ │ │ sbc.w r3, r3, r3, lsl #1 │ │ │ │ - bl 4977c │ │ │ │ + bl 49704 │ │ │ │ ldr.w lr, [sp, #4] │ │ │ │ ldrd r2, r3, [sp, #8] │ │ │ │ add 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dump of section '.dynstr': │ │ │ │ - 0x0000066c 005f4954 4d5f6465 72656769 73746572 ._ITM_deregister │ │ │ │ - 0x0000067c 544d436c 6f6e6554 61626c65 005f5f67 TMCloneTable.__g │ │ │ │ - 0x0000068c 6d6f6e5f 73746172 745f5f00 5f49544d mon_start__._ITM │ │ │ │ - 0x0000069c 5f726567 69737465 72544d43 6c6f6e65 _registerTMClone │ │ │ │ - 0x000006ac 5461626c 65006174 616e3200 6174616e Table.atan2.atan │ │ │ │ - 0x000006bc 00617369 6e00706f 77007369 6e636f73 .asin.pow.sincos │ │ │ │ - 0x000006cc 00737172 74006163 6f730066 6c6f6f72 .sqrt.acos.floor │ │ │ │ - 0x000006dc 00666765 7463005f 5f73656e 646d7367 .fgetc.__sendmsg │ │ │ │ - 0x000006ec 3634005f 5f736574 736f636b 6f707436 64.__setsockopt6 │ │ │ │ - 0x000006fc 34007075 74730070 6572726f 72005f5f 4.puts.perror.__ │ │ │ │ - 0x0000070c 67657474 696d656f 66646179 3634005f gettimeofday64._ │ │ │ │ - 0x0000071c 5f737461 636b5f63 686b5f66 61696c00 _stack_chk_fail. │ │ │ │ - 0x0000072c 66726565 00657869 74006e74 6f686c00 free.exit.ntohl. │ │ │ │ - 0x0000073c 6e746f68 73005f5f 61737365 72745f66 ntohs.__assert_f │ │ │ │ - 0x0000074c 61696c00 66726565 61646472 696e666f ail.freeaddrinfo │ │ │ │ - 0x0000075c 00676574 61646472 696e666f 0062696e .getaddrinfo.bin │ │ │ │ - 0x0000076c 64007374 72706272 6b006666 6c757368 d.strpbrk.fflush │ │ │ │ - 0x0000077c 0068746f 6e6c006d 656d6d6f 76650068 .htonl.memmove.h │ │ │ │ - 0x0000078c 746f6e73 00737472 746f6c00 736f636b tons.strtol.sock │ │ │ │ - 0x0000079c 65740073 74726c65 6e005f5f 63747970 et.strlen.__ctyp │ │ │ │ - 0x000007ac 655f625f 6c6f6300 7374646f 75740072 e_b_loc.stdout.r │ │ │ │ - 0x000007bc 65616c6c 6f630073 74726361 74006174 ealloc.strcat.at │ │ │ │ - 0x000007cc 6f660061 746f6900 6d616c6c 6f63005f of.atoi.malloc._ │ │ │ │ - 0x000007dc 5f6c6962 635f7374 6172745f 6d61696e _libc_start_main │ │ │ │ - 0x000007ec 005f5f69 6f63746c 5f74696d 65363400 .__ioctl_time64. │ │ │ │ - 0x000007fc 5f5f7469 6d653634 00737464 65727200 __time64.stderr. │ │ │ │ - 0x0000080c 66707269 6e746600 6d656d63 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#952] @ 0x3b8 │ │ │ │ - svclt 0x00185b02 │ │ │ │ - mcr 6, 1, r4, cr4, cr6, {4} │ │ │ │ - @ instruction: 0xf8df7b07 │ │ │ │ - blmi 7f1c90 <__time64@plt+0x7f0414> │ │ │ │ - mrc 4, 0, r4, cr6, cr12, {7} │ │ │ │ - @ instruction: 0xf85c7b05 │ │ │ │ - ldmdavs fp, {r0, r1, ip, sp} │ │ │ │ - @ instruction: 0xf04f9307 │ │ │ │ - svclt 0x000a0300 │ │ │ │ - movwcs r2, #769 @ 0x301 │ │ │ │ - stc 3, cr2, [lr, #4] │ │ │ │ - vldr d7, [r0] │ │ │ │ - vldr d5, [r1] │ │ │ │ + addlt fp, r9, r0, lsl #9 │ │ │ │ + mvnsvs sl, r0, lsl #30 │ │ │ │ + bleq 13cef4 <__time64@plt+0x13b73c> │ │ │ │ + blne bcef8 <__time64@plt+0xbb740> │ │ │ │ + blcs 3cefc <__time64@plt+0x3b744> │ │ │ │ + ldmib r7, {r0, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ + stmib r1, {r2, r8, r9, sp}^ │ │ │ │ + ldmibvs r9!, {r8, r9, sp}^ │ │ │ │ + movwcs lr, #10711 @ 0x29d7 │ │ │ │ + movwcs lr, #10689 @ 0x29c1 │ │ │ │ + ldmib r7, {r0, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ + stmib r1, {r8, r9, sp}^ │ │ │ │ + svclt 0x00002304 │ │ │ │ + ldrtmi r3, [sp], r4, lsr #14 │ │ │ │ + blvc 13fa7c <__time64@plt+0x13e2c4> │ │ │ │ + strlt r4, [r0], #1904 @ 0x770 │ │ │ │ + svcge 0x0000b085 │ │ │ │ + ldrshtvs r6, [r9], r8 │ │ │ │ + ldmvs fp!, {r1, r3, r4, r5, r6, sp, lr}^ │ │ │ │ + blvs 3cf68 <__time64@plt+0x3b7b0> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vadd.f64 d7, d6, d0 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 3cf38 <__time64@plt+0x3b780> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r1, r8, r9, fp, sp, lr} │ │ │ │ + blvc bcf84 <__time64@plt+0xbb7cc> │ │ │ │ + blvc 1fd214 <__time64@plt+0x1fba5c> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmvs fp!, {r1, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 13cf94 <__time64@plt+0x13b7dc> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vadd.f64 d7, d6, d4 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 13cf64 <__time64@plt+0x13b7ac> │ │ │ │ + ldrcc fp, [r4, -r0, lsl #30] │ │ │ │ + @ instruction: 0xf85d46bd │ │ │ │ + ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ + addlt fp, r2, r0, lsl #11 │ │ │ │ + rsbsvs sl, r8, r0, lsl #30 │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdavs fp!, {r8, r9, fp, sp, lr}^ │ │ │ │ + blvc 3cfc4 <__time64@plt+0x3b80c> │ │ │ │ + blvs 1fd214 <__time64@plt+0x1fba5c> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdavs fp!, {r1, r8, r9, fp, ip, lr}^ │ │ │ │ + blvc bcfd4 <__time64@plt+0xbb81c> │ │ │ │ + blvc 1fd220 <__time64@plt+0x1fba68> │ │ │ │ + blvs 1fd268 <__time64@plt+0x1fbab0> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdavs fp!, {r2, r8, r9, fp, ip, lr}^ │ │ │ │ + blvc 13cfe8 <__time64@plt+0x13b830> │ │ │ │ + blvc 1fd234 <__time64@plt+0x1fba7c> │ │ │ │ + blvc 1fd27c <__time64@plt+0x1fbac4> │ │ │ │ + bleq 11fd468 <__time64@plt+0x11fbcb0> │ │ │ │ + mrc 7, 2, APSR_nzcv, cr10, cr15, {7} │ │ │ │ + blvc 103d470 <__time64@plt+0x103bcb8> │ │ │ │ + bleq 11fd474 <__time64@plt+0x11fbcbc> │ │ │ │ + ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ + strlt fp, [r0], #3456 @ 0xd80 │ │ │ │ + svcge 0x0000b083 │ │ │ │ + ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ + blvs 3d014 <__time64@plt+0x3b85c> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmul.f64 d7, d6, d0 │ │ │ │ - vnmls.f64 d6, d4, d5 │ │ │ │ - vstr d6, [lr, #28] │ │ │ │ - vldr d6, [r0, #8] │ │ │ │ - vldr d4, [r1, #8] │ │ │ │ - vmul.f64 d6, d7, d2 │ │ │ │ - vnmls.f64 d7, d5, d4 │ │ │ │ - vstr d7, [lr, #24] │ │ │ │ - cmplt r3, r4, lsl #22 │ │ │ │ - ldm lr!, {r2, r4, r7, r9, sl, lr} │ │ │ │ - stmia ip!, {r0, r1, r2, r3} │ │ │ │ - ldm lr, {r0, r1, r2, r3} │ │ │ │ - stm ip, {r0, r1} │ │ │ │ - bmi 241b08 <__time64@plt+0x24028c> │ │ │ │ - ldrbtmi r4, [sl], #-2823 @ 0xfffff4f9 │ │ │ │ - ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ - subsmi r9, sl, r7, lsl #22 │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - andlt sp, r9, r2, lsl #2 │ │ │ │ - blx 13fc8a <__time64@plt+0x13e40e> │ │ │ │ - stc 7, cr15, [r8, #1020] @ 0x3fc │ │ │ │ - andeq fp, r0, r0, ror #10 │ │ │ │ - andeq r0, r0, ip, lsl r1 │ │ │ │ - andeq fp, r0, r2, lsl #10 │ │ │ │ - vst3.8 {d27,d29,d31}, [pc], r8 │ │ │ │ - bl feb58d2c <__time64@plt+0xfeb574b0> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - stmdbmi r3, {r3, r4, r5, r6, r7, r8, r9, sl, fp} │ │ │ │ - ldrbtmi r2, [r9], #-640 @ 0xfffffd80 │ │ │ │ - ldcl 7, cr15, [lr, #-1020] @ 0xfffffc04 │ │ │ │ - svclt 0x0000bd08 │ │ │ │ - andeq r8, r0, r2, lsl r3 │ │ │ │ - vst3.8 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb58d4c <__time64@plt+0xfeb574d0> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - bmi 6c58f4 <__time64@plt+0x6c4078> │ │ │ │ - blmi 6edde4 <__time64@plt+0x6ec568> │ │ │ │ - ldrbtmi r4, [sl], #-648 @ 0xfffffd78 │ │ │ │ - strbtmi fp, [ip], -ip, lsl #30 │ │ │ │ - strmi r4, [r6], ip, lsl #12 │ │ │ │ - stceq 1, cr15, [r0], #-16 │ │ │ │ - ldmpl r3, {r5, r7, sl, ip, sp}^ │ │ │ │ - @ instruction: 0x9321681b │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - msreq CPSR_, #172, 2 @ 0x2b │ │ │ │ - @ instruction: 0x46154672 │ │ │ │ - ldc 2, cr3, [r5, #128] @ 0x80 │ │ │ │ - vstmia r3!, {d7-d6} │ │ │ │ - strbmi r7, [r3, #-2818]! @ 0xfffff4fe │ │ │ │ - @ instruction: 0xf103d1f7 │ │ │ │ - @ instruction: 0xf10e0c20 │ │ │ │ - strmi r0, [r4, #3592]! @ 0xe08 │ │ │ │ - addmi sp, r8, #-2147483589 @ 0x8000003b │ │ │ │ - bmi 2f5bc8 <__time64@plt+0x2f434c> │ │ │ │ - ldrbtmi r4, [sl], #-2825 @ 0xfffff4f7 │ │ │ │ - ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ - subsmi r9, sl, r1, lsr #22 │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - eorlt sp, r3, r6, lsl #2 │ │ │ │ - addcs fp, r0, #48, 26 @ 0xc00 │ │ │ │ - @ instruction: 0xf7ff4669 │ │ │ │ - strb lr, [lr, r0, lsr #26]! │ │ │ │ - ldc 7, cr15, [r4, #-1020]! @ 0xfffffc04 │ │ │ │ - andeq fp, r0, r6, lsr #9 │ │ │ │ - andeq r0, r0, ip, lsl r1 │ │ │ │ - andeq fp, r0, r2, ror #8 │ │ │ │ - ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ - stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - @ instruction: 0x0c0cebad │ │ │ │ - svceq 0x0058f8cc │ │ │ │ - bmi ad343c <__time64@plt+0xad1bc0> │ │ │ │ - addmi r4, pc, #44032 @ 0xac00 │ │ │ │ - adcsmi fp, r8, #24, 30 @ 0x60 │ │ │ │ - adclt r4, r2, sl, ror r4 │ │ │ │ - @ instruction: 0xf04fbf09 │ │ │ │ - @ instruction: 0xf04f0901 │ │ │ │ - strbtmi r0, [lr], -r0, lsl #18 │ │ │ │ - stmdbeq r1, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ - svclt 0x001858d3 │ │ │ │ - @ instruction: 0x460a463e │ │ │ │ - cdpeq 1, 2, cr15, cr0, cr1, {0} │ │ │ │ - @ instruction: 0x9321681b │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - stmeq r0, {r0, r8, ip, sp, lr, pc} │ │ │ │ - streq pc, [r0, #-256]! @ 0xffffff00 │ │ │ │ - ldrtmi r4, [r4], -r1, lsl #12 │ │ │ │ - pkhbtmi r4, ip, r3, lsl #12 │ │ │ │ - blvc 63d2a0 <__time64@plt+0x63ba24> │ │ │ │ - ldc 6, cr4, [r3], #904 @ 0x388 │ │ │ │ - @ instruction: 0xf10c5b02 │ │ │ │ - ldc 12, cr0, [sl, #128] @ 0x80 │ │ │ │ - ldrbmi r6, [r3, #-2816]! @ 0xfffff500 │ │ │ │ - blvc 1bd44c <__time64@plt+0x1bbbd0> │ │ │ │ - strdcc sp, [r8, -r4] │ │ │ │ - blvc bced0 <__time64@plt+0xbb654> │ │ │ │ - mvnle r4, r9, lsr #5 │ │ │ │ - @ instruction: 0xf1033220 │ │ │ │ - strtcc r0, [r0], -r0, lsr #28 │ │ │ │ - mvnle r4, r2, asr #10 │ │ │ │ - svceq 0x0000f1b9 │ │ │ │ - addcs sp, r0, #4 │ │ │ │ - ldrtmi r4, [r8], -r9, ror #12 │ │ │ │ - stcl 7, cr15, [ip], {255} @ 0xff │ │ │ │ - blmi 2d4494 <__time64@plt+0x2d2c18> │ │ │ │ - ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 85bcd4 <__time64@plt+0x85a458> │ │ │ │ - @ instruction: 0xf04f405a │ │ │ │ - mrsle r0, LR_svc │ │ │ │ - pop {r1, r5, ip, sp, pc} │ │ │ │ - @ instruction: 0xf7ff87f0 │ │ │ │ - svclt 0x0000ecd6 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl bd024 <__time64@plt+0xbb86c> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d2 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 13d038 <__time64@plt+0x13b880> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d4 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ + strcc r0, [ip, -r7, asr #22] │ │ │ │ + @ instruction: 0xf85d46bd │ │ │ │ + ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ + addlt fp, r5, r0, lsl #9 │ │ │ │ + rscsvs sl, r8, r0, lsl #30 │ │ │ │ + ldrhtvs r6, [sl], #-9 │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, sp, lr} │ │ │ │ + blvc 3d06c <__time64@plt+0x3b8b4> │ │ │ │ + blvc 11fd2fc <__time64@plt+0x11fbb44> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs bd07c <__time64@plt+0xbb8c4> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vadd.f64 d7, d6, d2 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc bd04c <__time64@plt+0xbb894> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, sp, lr} │ │ │ │ + blvc 13d098 <__time64@plt+0x13b8e0> │ │ │ │ + blvc 11fd328 <__time64@plt+0x11fbb70> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + svclt 0x00007b04 │ │ │ │ + ssatmi r3, #30, r4, lsl #14 │ │ │ │ + blvc 13fbd4 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ldmvs sl!, {r1, r3, r4, r5, r6, sp, lr}^ │ │ │ │ + addsmi r6, sl, #8060928 @ 0x7b0000 │ │ │ │ + ldmvs sl!, {r0, r1, ip, lr, pc} │ │ │ │ + addsmi r6, sl, #8060928 @ 0x7b0000 │ │ │ │ + movwcs sp, #4357 @ 0x1105 │ │ │ │ + @ instruction: 0xf10762fb │ │ │ │ + adcsvs r0, fp, #16, 6 @ 0x40000000 │ │ │ │ + movwcs lr, #3 │ │ │ │ + ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, r9, sp, lr}^ │ │ │ │ + ldmvs fp!, {r0, r1, r3, r4, r5, r7, r9, sp, lr}^ │ │ │ │ + blvs bd134 <__time64@plt+0xbb97c> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d4 │ │ │ │ + ldmvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 13d144 <__time64@plt+0x13b98c> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d5, d2 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + bvs feee0824 <__time64@plt+0xfeedf06c> │ │ │ │ + blvc 3d118 <__time64@plt+0x3b960> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, sp, lr} │ │ │ │ + blvc 3d164 <__time64@plt+0x3b9ac> │ │ │ │ + blvs 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0x3090f8d7 │ │ │ │ + @ instruction: 0xf8d70099 │ │ │ │ + strmi r3, [fp], #-148 @ 0xffffff6c │ │ │ │ + ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ + movwcs lr, #2515 @ 0x9d3 │ │ │ │ + ldrdeq pc, [ip], r7 │ │ │ │ + @ instruction: 0x1094f8d7 │ │ │ │ + @ instruction: 0xf8d7008c │ │ │ │ + strtmi r1, [r1], #-144 @ 0xffffff70 │ │ │ │ + strmi r0, [r1], #-201 @ 0xffffff37 │ │ │ │ + movwcs lr, #2497 @ 0x9c1 │ │ │ │ + @ instruction: 0x3090f8d7 │ │ │ │ + @ instruction: 0xf8c73301 │ │ │ │ + @ instruction: 0xf8d73090 │ │ │ │ + blcs cde5c <__time64@plt+0xcc6a4> │ │ │ │ + @ instruction: 0xf8d7dddf │ │ │ │ + movwcc r3, #4244 @ 0x1094 │ │ │ │ + addscc pc, r4, r7, asr #17 │ │ │ │ + @ instruction: 0x3094f8d7 │ │ │ │ + vldrle d18, [r2, #12] │ │ │ │ + ldmdavs fp!, {r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ + @ instruction: 0xd107429a │ │ │ │ + @ instruction: 0x4618683b │ │ │ │ + movweq pc, #33031 @ 0x8107 @ │ │ │ │ + ldrmi r2, [r9], -r0, lsl #5 │ │ │ │ + stc 7, cr15, [r2], {255} @ 0xff │ │ │ │ + ldrcc fp, [ip, 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r0, [r3], #-219 @ 0xffffff25 │ │ │ │ + blvc 3d304 <__time64@plt+0x3bb4c> │ │ │ │ + blvc 1fd554 <__time64@plt+0x1fbd9c> │ │ │ │ + blhi 1fd5a0 <__time64@plt+0x1fbde8> │ │ │ │ + cdpcs 6, 0, cr3, cr3, cr1, {0} │ │ │ │ + @ instruction: 0xf8d7ddea │ │ │ │ + umlaleq r2, r3, r0, r0 │ │ │ │ + sbcseq r4, fp, fp, lsr #8 │ │ │ │ + stc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ + strcc r8, [r1, #-2816] @ 0xfffff500 │ │ │ │ + ldclle 13, cr2, [fp, #12] │ │ │ │ + stccs 4, cr3, [r3], {1} │ │ │ │ + @ instruction: 0xf8d7ddd6 │ │ │ │ + blcs df38 <__time64@plt+0xc780> │ │ │ │ + ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ + @ instruction: 0xf1074618 │ │ │ │ + addcs r0, r0, #16, 6 @ 0x40000000 │ │ │ │ + @ instruction: 0xf7ff4619 │ │ │ │ + svclt 0x0000ec2a │ │ │ │ + ssatmi r3, #30, ip, lsl #15 │ │ │ │ + blhi bcff8 <__time64@plt+0xbb840> │ │ │ │ + svclt 0x0000bdf0 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ ... │ │ │ │ - andeq fp, r0, r8, lsl r4 │ │ │ │ - andeq r0, r0, ip, lsl r1 │ │ │ │ - muleq r0, ip, r3 │ │ │ │ - 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cr15, [r1], {12} │ │ │ │ - cdpeq 1, 2, cr15, cr0, cr14, {0} │ │ │ │ - ldc 5, cr4, [sl, #396] @ 0x18c │ │ │ │ - vmla.f64 d6, d5, d0 │ │ │ │ - vldmiale r2!, {d23-d25} │ │ │ │ - andcc r3, r8, #16777216 @ 0x1000000 │ │ │ │ - stc 2, cr4, [r5], #652 @ 0x28c │ │ │ │ - vstmiale r6!, {d23} │ │ │ │ - bleq 7e14c <__time64@plt+0x7c8d0> │ │ │ │ - strcc r3, [r0, -r0, lsr #12]! │ │ │ │ - ldclle 5, cr4, [sp], {91} @ 0x5b │ │ │ │ - movwcs r2, #512 @ 0x200 │ │ │ │ - tstcs r6, #3293184 @ 0x324000 │ │ │ │ - movwcs lr, #59849 @ 0xe9c9 │ │ │ │ - movwcs lr, #27081 @ 0x69c9 │ │ │ │ - tstcs ip, #3293184 @ 0x324000 │ │ │ │ - tstcs sl, #3293184 @ 0x324000 │ │ │ │ - tstcs r8, #3293184 @ 0x324000 │ │ │ │ - movwcs r2, #512 @ 0x200 │ │ │ │ - mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ - tstcs lr, #3293184 @ 0x324000 │ │ │ │ - bllt e8958 <__time64@plt+0xe70dc> │ │ │ │ - blmi 9145ec <__time64@plt+0x912d70> │ │ │ │ - ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 8dbdc8 <__time64@plt+0x8da54c> │ │ │ │ - @ instruction: 0xf04f405a │ │ │ │ - teqle r7, r0, lsl #6 │ │ │ │ - pop {r0, r2, r5, ip, sp, pc} │ │ │ │ - andcs r8, r0, #240, 30 @ 0x3c0 │ │ │ │ - andcs r2, r0, r0, lsl #6 │ │ │ │ - @ instruction: 0xf6c32100 │ │ │ │ - stmib sp, {r4, r5, r6, r7, r8, ip, sp, lr}^ │ │ │ │ - stmib sp, {r3, r4, r8, r9, sp}^ │ │ │ │ - stmib sp, {r5, r8}^ │ │ │ │ - stmib sp, {r4, r8, r9, sp}^ │ │ │ │ - stmib sp, {r3, r8, r9, sp}^ │ │ │ │ - stmib sp, {r1, r2, r3, r4, r8, r9, sp}^ │ │ │ │ - stmib sp, {r2, r3, r4, r8, r9, sp}^ │ │ │ │ - addcs r2, r0, #1744830464 @ 0x68000000 │ │ │ │ - strbmi sl, [r0], -r2, lsl #18 │ │ │ │ - stc 7, cr15, [ip], #-1020 @ 0xfffffc04 │ │ │ │ - blcs 3bd04 <__time64@plt+0x3a488> │ │ │ │ - @ instruction: 0xf8cdbfc4 │ │ │ │ - strbmi sl, [r1], r4 │ │ │ │ - andcs sp, r0, #38656 @ 0x9700 │ │ │ │ - andcs r2, r0, r0, lsl #6 │ │ │ │ - @ instruction: 0xf6c32100 │ │ │ │ - stmib r8, {r4, r5, r6, r7, r8, ip, sp, lr}^ │ │ │ │ - stmib r8, {r1, r2, r4, r8, r9, sp}^ │ │ │ │ - stmib r8, {r1, r2, r3, r4, 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#8060928 @ 0x7b0000 │ │ │ │ + movwcs sp, #4359 @ 0x1107 │ │ │ │ + addscc pc, r4, r7, asr #17 │ │ │ │ + tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ + addscc pc, r0, r7, asr #17 │ │ │ │ + movwcs lr, #5 │ │ │ │ + addscc pc, r4, r7, asr #17 │ │ │ │ + @ instruction: 0xf8c7687b │ │ │ │ + movwcs r3, #144 @ 0x90 │ │ │ │ + adccc pc, ip, r7, asr #17 │ │ │ │ + movwcs lr, #82 @ 0x52 │ │ │ │ + adccc pc, r8, r7, asr #17 │ │ │ │ + @ instruction: 0xf04fe044 │ │ │ │ + @ instruction: 0xf04f0200 │ │ │ │ + stmib r7, {r8, r9}^ │ │ │ │ + movwcs r2, #806 @ 0x326 │ │ │ │ + adccc pc, r4, r7, asr #17 │ │ │ │ + ldmvs sl!, {r1, r5, sp, lr, pc}^ │ │ │ │ + ldrdcc pc, [r4], r7 @ │ │ │ │ + @ instruction: 0xf8d70099 │ │ │ │ + strmi r3, [fp], #-168 @ 0xffffff58 │ │ │ │ + ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ + blvs 3d3d4 <__time64@plt+0x3bc1c> │ │ │ │ + @ instruction: 0xf8d768ba │ │ │ │ + addseq r3, r9, ip, lsr #1 │ │ │ │ + ldrdcc pc, [r4], r7 @ │ │ │ │ + sbcseq r4, fp, fp, lsl #8 │ │ │ │ + ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ + vmul.f64 d7, d6, d0 │ │ │ │ + vldr d7, [r7, #28] │ │ │ │ + vadd.f64 d6, d6, d22 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + @ instruction: 0xf8d77b26 │ │ │ │ + movwcc r3, #4260 @ 0x10a4 │ │ │ │ + adccc pc, r4, r7, asr #17 │ │ │ │ + ldrdcs pc, [r4], r7 @ │ │ │ │ + addsmi r6, sl, #3866624 @ 0x3b0000 │ │ │ │ + @ instruction: 0xf8d7dbd7 │ │ │ │ + @ instruction: 0xf8d72090 │ │ │ │ + addseq r3, r9, ip, lsr #1 │ │ │ │ + ldrdcc pc, [r8], r7 @ │ │ │ │ + sbcseq r4, fp, fp, lsl #8 │ │ │ │ + ldmib r7, {r0, r4, r6, r7, fp, ip}^ │ │ │ │ + stmib r1, {r1, r2, r5, r8, r9, sp}^ │ │ │ │ + @ instruction: 0xf8d72300 │ │ │ │ + movwcc r3, #4264 @ 0x10a8 │ │ │ │ + adccc pc, r8, r7, asr #17 │ │ │ │ + ldrdcs pc, [r8], r7 @ │ │ │ │ + addsmi r6, sl, #3866624 @ 0x3b0000 │ │ │ │ + @ instruction: 0xf8d7dbb5 │ │ │ │ + movwcc r3, #4268 @ 0x10ac │ │ │ │ + adccc pc, ip, r7, asr #17 │ │ │ │ + ldrdcs pc, [ip], r7 @ │ │ │ │ + addsmi r6, sl, #3866624 @ 0x3b0000 │ │ │ │ + @ instruction: 0xf8d7dba7 │ │ │ │ + @ instruction: 0xf04f1090 │ │ │ │ + @ instruction: 0xf04f0200 │ │ │ │ + stmib r1, {r8, r9}^ │ │ │ │ + @ instruction: 0xf8d72316 │ │ │ │ + ldmib r3, {r4, r7, ip, sp}^ │ │ │ │ + @ instruction: 0xf8d72316 │ │ │ │ + stmib r1, {r4, r7, ip}^ │ │ │ │ + @ instruction: 0xf8d7230e │ │ │ │ + ldmib r3, {r4, r7, ip, sp}^ │ │ │ │ + @ instruction: 0xf8d7230e │ │ │ │ + stmib r1, {r4, r7, ip}^ │ │ │ │ + @ instruction: 0xf8d72306 │ │ │ │ + @ instruction: 0xf04f1090 │ │ │ │ + @ instruction: 0xf04f0200 │ │ │ │ + stmib r1, {r8, r9}^ │ │ │ │ + @ instruction: 0xf8d7231c │ │ │ │ + ldmib r3, {r4, r7, ip, sp}^ │ │ │ │ + @ instruction: 0xf8d7231c │ │ │ │ + stmib r1, {r4, r7, ip}^ │ │ │ │ + @ instruction: 0xf8d7231a │ │ │ │ + ldmib r3, {r4, r7, ip, sp}^ │ │ │ │ + @ instruction: 0xf8d7231a │ │ │ │ + stmib r1, {r4, r7, ip}^ │ │ │ │ + @ instruction: 0xf8d72318 │ │ │ │ + @ instruction: 0xf04f1090 │ │ │ │ + @ instruction: 0xf04f0200 │ │ │ │ + @ instruction: 0xf6c30300 │ │ │ │ + stmib r1, {r4, r5, r6, r7, r8, r9, ip, sp, lr}^ │ │ │ │ + @ instruction: 0xf8d7231e │ │ │ │ + blcs e0d0 <__time64@plt+0xc918> │ │ │ │ + ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ + @ instruction: 0xf1074618 │ │ │ │ + addcs r0, r0, #16, 6 @ 0x40000000 │ │ │ │ + @ instruction: 0xf7ff4619 │ │ │ │ + svclt 0x0000eb5e │ │ │ │ + @ instruction: 0x46bd37b0 │ │ │ │ + strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ + svcge 0x0000b0a8 │ │ │ │ + ldrshtvs r6, [r9], r8 │ │ │ │ + bleq 3d4c4 <__time64@plt+0x3bd0c> │ │ │ │ + tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ + @ instruction: 0xf7ff4618 │ │ │ │ + ldc 14, cr15, [r7, #420] @ 0x1a4 │ │ │ │ + @ instruction: 0xf7ff0b00 │ │ │ │ + stc 12, cr14, [r7, #496] @ 0x1f0 │ │ │ │ + vldr d0, [r7, #152] @ 0x98 │ │ │ │ + @ instruction: 0xf7ff0b00 │ │ │ │ + vstr d14, [r7, #752] @ 0x2f0 │ │ │ │ + ldmvs fp!, {r2, r5, r8, r9, fp} │ │ │ │ + eorle r2, pc, r3, lsl #22 │ │ │ │ + blcs dc1c0 <__time64@plt+0xdaa08> │ │ │ │ + ldmvs fp!, {r0, r1, r2, r3, r4, r5, sl, fp, ip, lr, pc} │ │ │ │ + andle r2, r3, r1, lsl #22 │ │ │ │ + blcs 9c1cc <__time64@plt+0x9aa14> │ │ │ │ + eors sp, r8, r3, lsl r0 │ │ │ │ + @ instruction: 0x2326e9d7 │ │ │ │ + tstcs r8, #3260416 @ 0x31c000 │ │ │ │ + tstcs r8, #3522560 @ 0x35c000 │ │ │ │ + movwcs lr, #59847 @ 0xe9c7 │ │ │ │ + @ instruction: 0x2324e9d7 │ │ │ │ + tstcs r6, #3260416 @ 0x31c000 │ │ │ │ + blvc 93d55c <__time64@plt+0x93bda4> │ │ │ │ + blvc 11fd9c8 <__time64@plt+0x11fc210> │ │ │ │ + blvc 43d524 <__time64@plt+0x43bd6c> │ │ │ │ + ldmib r7, {r0, r2, r5, sp, lr, pc}^ │ │ │ │ + stmib r7, {r1, r2, r5, r8, r9, sp}^ │ │ │ │ + ldmib r7, {r3, r4, r8, r9, sp}^ │ │ │ │ + stmib r7, {r3, r4, r8, r9, sp}^ │ │ │ │ + ldmib r7, {r2, r8, r9, sp}^ │ │ │ │ + stmib r7, {r2, r5, r8, r9, sp}^ │ │ │ │ + ldc 3, cr2, [r7, #32] │ │ │ │ + @ instruction: 0xeeb17b24 │ │ │ │ + vstr d7, [r7, #284] @ 0x11c │ │ │ │ + ands r7, r2, r4, lsl fp │ │ │ │ + @ instruction: 0x2326e9d7 │ │ │ │ + movwcs lr, #59847 @ 0xe9c7 │ │ │ │ + movwcs lr, #59863 @ 0xe9d7 │ │ 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<__time64@plt+0x3c2c4> │ │ │ │ + blvc 1bd9b8 <__time64@plt+0x1bc200> │ │ │ │ + blvc c3d5c4 <__time64@plt+0xc3be0c> │ │ │ │ + blvs 93d608 <__time64@plt+0x93be50> │ │ │ │ + blvc c3d60c <__time64@plt+0xc3be54> │ │ │ │ + blvc 1fd84c <__time64@plt+0x1fc094> │ │ │ │ + blvc 93d5d4 <__time64@plt+0x93be1c> │ │ │ │ + blvs 9bd618 <__time64@plt+0x9bbe60> │ │ │ │ + blvc c3d61c <__time64@plt+0xc3be64> │ │ │ │ + blvc 1fd85c <__time64@plt+0x1fc0a4> │ │ │ │ + blvc 9bd5e4 <__time64@plt+0x9bbe2c> │ │ │ │ + blvs a3d628 <__time64@plt+0xa3be70> │ │ │ │ + blvc c3d62c <__time64@plt+0xc3be74> │ │ │ │ + blvc 1fd86c <__time64@plt+0x1fc0b4> │ │ │ │ + blvc a3d5f4 <__time64@plt+0xa3be3c> │ │ │ │ + bleq 3d638 <__time64@plt+0x3be80> │ │ │ │ + bl ffa3ffdc <__time64@plt+0xffa3e824> │ │ │ │ + bleq bbd600 <__time64@plt+0xbbbe48> │ │ │ │ + blvs 3dac4 <__time64@plt+0x3c30c> │ │ │ │ + blvc bbd648 <__time64@plt+0xbbbe90> │ │ │ │ + blvc 11fd8c8 <__time64@plt+0x11fc110> │ │ │ │ + blvc b3d610 <__time64@plt+0xb3be58> │ │ │ │ + bleq 3d654 <__time64@plt+0x3be9c> │ │ │ │ + bl 83fff8 <__time64@plt+0x83e840> │ │ │ │ + bleq abd61c <__time64@plt+0xabbe64> │ │ │ │ + tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ + @ instruction: 0xf7ff4618 │ │ │ │ + ldc 13, cr15, [r7, #756] @ 0x2f4 │ │ │ │ + vldr d6, [r7, #144] @ 0x90 │ │ │ │ + vmul.f64 d7, d6, d20 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d28 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vadd.f64 d7, d6, d30 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + vldr d7, [r7, #16] │ │ │ │ + vldr d6, [r7, #144] @ 0x90 │ │ │ │ + vmul.f64 d7, d6, d22 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d28 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vldr d5, [r7, #160] @ 0xa0 │ │ │ │ + vmul.f64 d7, d5, d26 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vstr d7, [r7, #284] @ 0x11c │ │ │ │ + vldr d7, [r7, #24] │ │ │ │ + vldr d6, [r7, #144] @ 0x90 │ │ │ │ + vmul.f64 d7, d6, d24 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d28 │ │ │ │ + vldr d6, [r7, #28] │ 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[r7, #284] @ 0x11c │ │ │ │ + vldr d7, [r7, #64] @ 0x40 │ │ │ │ + vldr d6, [r7, #144] @ 0x90 │ │ │ │ + vmul.f64 d7, d6, d24 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d28 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vldr d5, [r7, #152] @ 0x98 │ │ │ │ + vmul.f64 d7, d5, d26 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vstr d7, [r7, #284] @ 0x11c │ │ │ │ + vldr d7, [r7, #80] @ 0x50 │ │ │ │ + vldr d6, [r7, #152] @ 0x98 │ │ │ │ + vmul.f64 d7, d6, d24 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d28 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vldr d5, [r7, #144] @ 0x90 │ │ │ │ + vmul.f64 d7, d5, d26 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + vldr d7, [r7, #88] @ 0x58 │ │ │ │ + vldr d6, [r7, #160] @ 0xa0 │ │ │ │ + vmul.f64 d7, d6, d24 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d28 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vadd.f64 d7, d6, d30 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + @ instruction: 0xf1077b18 │ │ │ │ + ldmvs sl!, {r4, r8, r9}^ │ │ │ │ + ldmvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ + ldc2l 7, cr15, [r4, #-1020]! @ 0xfffffc04 │ │ │ │ + strbcc fp, [r8, r0, lsl #30] │ │ │ │ + ldclt 6, cr4, [r0, #756]! @ 0x2f4 │ │ │ │ + adclt fp, r8, r0, lsl #11 │ │ │ │ + mvnsvs sl, r0, lsl #30 │ │ │ │ + bleq 13d798 <__time64@plt+0x13bfe0> │ │ │ │ + blne bd79c <__time64@plt+0xbbfe4> │ │ │ │ + blcs 3d7a0 <__time64@plt+0x3bfe8> │ │ │ │ + msreq CPSR_, #-1073741823 @ 0xc0000001 │ │ │ │ + @ instruction: 0xf7ff4618 │ │ │ │ + ldmib r7, {r0, r1, r3, r4, r5, r6, r7, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + stmib r7, {r2, r8, r9, sp}^ │ │ │ │ + ldmib r7, {r3, r8, r9, sp}^ │ │ │ │ + stmib r7, {r1, r8, r9, sp}^ │ │ │ │ + ldmib r7, {r1, r4, r8, r9, sp}^ │ │ │ │ + stmib r7, {r8, r9, sp}^ │ │ │ │ + @ instruction: 0xf107231c │ │ │ │ + ldmibvs sl!, {r5, r8, r9}^ │ │ │ │ + ldmibvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ + stc2l 7, cr15, [lr, #-1020] @ 0xfffffc04 │ │ │ │ + strcc fp, [r0, r0, lsl #30]! │ │ │ │ + stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ + addlt fp, r9, r0, lsl #9 │ │ │ │ + mvnsvs sl, r0, lsl #30 │ │ │ │ + blpl 103dc88 <__time64@plt+0x103c4d0> │ │ │ │ + blvs 107dc8c <__time64@plt+0x107c4d4> │ │ │ │ + blvc 10bdc90 <__time64@plt+0x10bc4d8> │ │ │ │ + blpl 3d7f0 <__time64@plt+0x3c038> │ │ │ │ + blvs bd7f4 <__time64@plt+0xbc03c> │ │ │ │ + blvc 13d7f8 <__time64@plt+0x13c040> │ │ │ │ + @ instruction: 0xed9369fb │ │ │ │ + vldr d6, [r7, #24] │ │ │ │ + vadd.f64 d7, d6, d0 │ │ │ │ + ldmibvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 1bd7fc <__time64@plt+0x1bc044> │ │ │ │ + @ instruction: 0xed9369fb │ │ │ │ + vldr d6, [r7, #56] @ 0x38 │ │ │ │ + vadd.f64 d7, d6, d2 │ │ │ │ + ldmibvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 3bd810 <__time64@plt+0x3bc058> │ │ │ │ + @ instruction: 0xed9369fb │ │ │ │ + vldr d6, [r7, #88] @ 0x58 │ │ │ │ + vadd.f64 d7, d6, d4 │ │ │ │ + ldmibvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 5bd824 <__time64@plt+0x5bc06c> │ │ │ │ + strcc fp, [r4, -r0, lsl #30]! │ │ │ │ + @ instruction: 0xf85d46bd │ │ │ │ + ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ + addlt fp, r9, r0, lsl #9 │ │ │ │ + mvnsvs sl, r0, lsl #30 │ │ │ │ + bleq 13d84c <__time64@plt+0x13c094> │ │ │ │ + blne bd850 <__time64@plt+0xbc098> │ │ │ │ + blcs 3d854 <__time64@plt+0x3c09c> │ │ │ │ + @ instruction: 0xed9369fb │ │ │ │ + vldr d6, [r7, #24] │ │ │ │ + vadd.f64 d7, d6, d4 │ │ │ │ + ldmibvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 1bd858 <__time64@plt+0x1bc0a0> │ │ │ │ + @ instruction: 0xed9369fb │ │ │ │ + vldr d6, [r7, #56] @ 0x38 │ │ │ │ + vadd.f64 d7, d6, d2 │ │ │ │ + ldmibvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 3bd86c <__time64@plt+0x3bc0b4> │ │ │ │ + @ instruction: 0xed9369fb │ │ │ │ + vldr d6, [r7, #88] @ 0x58 │ │ │ │ + vadd.f64 d7, d6, d0 │ │ │ │ + ldmibvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 5bd880 <__time64@plt+0x5bc0c8> │ │ │ │ + strcc fp, [r4, -r0, lsl #30]! │ │ │ │ + @ instruction: 0xf85d46bd │ │ │ │ + ldrbmi r7, [r0, -r4, lsl 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│ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, ip, lr} │ │ │ │ + blvc 53d994 <__time64@plt+0x53c1dc> │ │ │ │ + blvc 1fdbe0 <__time64@plt+0x1fc428> │ │ │ │ + blvs 1fdc28 <__time64@plt+0x1fc470> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmov.32 r7, d6[1] │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmdavs fp!, {r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + @ instruction: 0xf107461d │ │ │ │ + stcgt 4, cr0, [pc], {16} │ │ │ │ + ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ + stm r5, {r0, r1} │ │ │ │ + svclt 0x00000003 │ │ │ │ + ldrtmi r3, [sp], ip, lsr #14 │ │ │ │ + @ instruction: 0x4770bcb0 │ │ │ │ + addlt fp, fp, r0, lsl #9 │ │ │ │ + rscsvs sl, r8, r0, lsl #30 │ │ │ │ + ldrhtvs r6, [sl], #-9 │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, sp, lr} │ │ │ │ + blvc 1bd9e0 <__time64@plt+0x1bc228> │ │ │ │ + blvc 11fdc70 <__time64@plt+0x11fc4b8> │ │ │ │ + blvc 13d9b8 <__time64@plt+0x13c200> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r1, r8, r9, fp, sp, lr} │ │ │ │ + blvc 3bd9f4 <__time64@plt+0x3bc23c> │ │ │ │ + blvc 11fdc84 <__time64@plt+0x11fc4cc> │ │ │ │ + blvc 1bd9cc <__time64@plt+0x1bc214> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, sp, lr} │ │ │ │ + blvc 5bda08 <__time64@plt+0x5bc250> │ │ │ │ + blvc 11fdc98 <__time64@plt+0x11fc4e0> │ │ │ │ + blvc 23d9e0 <__time64@plt+0x23c228> │ │ │ │ + blvs 13da24 <__time64@plt+0x13c26c> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d0 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + ldmvs fp!, {r1, r2, r8, r9, fp, ip, lr} │ │ │ │ + blvc 23da28 <__time64@plt+0x23c270> │ │ │ │ + blvc 1fdc74 <__time64@plt+0x1fc4bc> │ │ │ │ + blvs 1fdcbc <__time64@plt+0x1fc504> │ │ │ │ + blpl 23da44 <__time64@plt+0x23c28c> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmov.32 d5[1], r7 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 3da08 <__time64@plt+0x3c250> │ │ │ │ + blvs 13da5c <__time64@plt+0x13c2a4> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d2 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + ldmvs fp!, {r1, r2, r8, r9, fp, ip, lr} │ │ │ │ + blvc 2bda60 <__time64@plt+0x2bc2a8> │ │ │ │ + blvc 1fdcac <__time64@plt+0x1fc4f4> │ │ │ │ + blvs 1fdcf4 <__time64@plt+0x1fc53c> │ │ │ │ + blpl 23da7c <__time64@plt+0x23c2c4> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmov.32 d5[1], r7 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc bda40 <__time64@plt+0xbc288> │ │ │ │ + blvs 13da94 <__time64@plt+0x13c2dc> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d4 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + ldmvs fp!, {r1, r2, r8, r9, fp, ip, lr} │ │ │ │ + blvc 33da98 <__time64@plt+0x33c2e0> │ │ │ │ + blvc 1fdce4 <__time64@plt+0x1fc52c> │ │ │ │ + blvs 1fdd2c <__time64@plt+0x1fc574> │ │ │ │ + blpl 23dab4 <__time64@plt+0x23c2fc> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmov.32 d5[1], r7 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 13da78 <__time64@plt+0x13c2c0> │ │ │ │ + strcc fp, [ip, -r0, lsl #30]! │ │ │ │ + @ instruction: 0xf85d46bd │ │ │ │ + ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ + @ instruction: 0xb08bb4b0 │ │ │ │ + rscsvs sl, r8, r0, lsl #30 │ │ │ │ + ldrhtvs r6, [sl], #-9 │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, sp, lr} │ │ │ │ + blvc 3dadc <__time64@plt+0x3c324> │ │ │ │ + blvs 1fdd2c <__time64@plt+0x1fc574> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r1, r8, r9, fp, ip, lr} │ │ │ │ + blvc bdaec <__time64@plt+0xbc334> │ │ │ │ + blvc 1fdd38 <__time64@plt+0x1fc580> │ │ │ │ + blvs 1fdd80 <__time64@plt+0x1fc5c8> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, ip, lr} │ │ │ │ + blvc 13db00 <__time64@plt+0x13c348> │ │ │ │ + blvc 1fdd4c <__time64@plt+0x1fc594> │ │ │ │ + blvc 1fdd94 <__time64@plt+0x1fc5dc> │ │ │ │ + blvc 13dadc <__time64@plt+0x13c324> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, sp, lr} │ │ │ │ + blvc 23db18 <__time64@plt+0x23c360> │ │ │ │ + blvs 1fdd68 <__time64@plt+0x1fc5b0> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r1, r8, r9, fp, ip, lr} │ │ │ │ + blvc 2bdb28 <__time64@plt+0x2bc370> │ │ │ │ + blvc 1fdd74 <__time64@plt+0x1fc5bc> │ │ │ │ + blvs 1fddbc <__time64@plt+0x1fc604> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, ip, lr} │ │ │ │ + blvc 33db3c <__time64@plt+0x33c384> │ │ │ │ + blvc 1fdd88 <__time64@plt+0x1fc5d0> │ │ │ │ + blvc 1fddd0 <__time64@plt+0x1fc618> │ │ │ │ + blvc 1bdb18 <__time64@plt+0x1bc360> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, sp, lr} │ │ │ │ + blvc 43db54 <__time64@plt+0x43c39c> │ │ │ │ + blvs 1fdda4 <__time64@plt+0x1fc5ec> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r1, r8, r9, fp, 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r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl bdbc4 <__time64@plt+0xbc40c> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d5, d8 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 13dbd8 <__time64@plt+0x13c420> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmov.32 d5[1], r7 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmvs fp!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 3dbf0 <__time64@plt+0x3c438> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d2 │ │ │ │ + ldmvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl bdc00 <__time64@plt+0xbc448> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d5, d10 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 13dc14 <__time64@plt+0x13c45c> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmov.32 d5[1], r7 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmvs fp!, {r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 3dc2c <__time64@plt+0x3c474> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d6, d4 │ │ │ │ + ldmvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl bdc3c <__time64@plt+0xbc484> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmul.f64 d7, d5, d12 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 13dc50 <__time64@plt+0x13c498> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + vmov.32 d5[1], r7 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmdavs fp!, {r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + @ instruction: 0xf107461d │ │ │ │ + stcgt 4, cr0, [pc], {16} │ │ │ │ + ldm r4, {r0, r1, r2, r3, r8, sl, lr, pc} │ │ │ │ + stm r5, {r0, r1} │ │ │ │ + svclt 0x00000003 │ │ │ │ + ldrtmi r3, [sp], ip, lsr #14 │ │ │ │ + @ instruction: 0x4770bcb0 │ │ │ │ + addslt fp, r4, r0, lsl #11 │ │ │ │ + stc 15, cr10, [r7] │ │ │ │ + vstr d0, [r7, #24] │ │ │ │ + vstr d1, [r7, #16] │ │ │ │ + rsbsvs r2, r8, r2, lsl #22 │ │ │ │ + bleq 1bdca8 <__time64@plt+0x1bc4f0> │ │ │ │ + svc 0x00f6f7fe │ │ │ │ + bleq 4bdc70 <__time64@plt+0x4bc4b8> │ │ │ │ + bleq 1bdcb4 <__time64@plt+0x1bc4fc> │ │ │ │ + stmia sl!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bleq 43dc7c <__time64@plt+0x43c4c4> │ │ │ │ + bleq 13dcc0 <__time64@plt+0x13c508> │ │ │ │ + svc 0x00eaf7fe │ │ │ │ + bleq 3bdc88 <__time64@plt+0x3bc4d0> │ │ │ │ + bleq 13dccc <__time64@plt+0x13c514> │ │ │ │ + ldm lr, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bleq 33dc94 <__time64@plt+0x33c4dc> │ │ │ │ + bleq bdcd8 <__time64@plt+0xbc520> │ │ │ │ + svc 0x00def7fe │ │ │ │ + bleq 2bdca0 <__time64@plt+0x2bc4e8> │ │ │ │ + bleq bdce4 <__time64@plt+0xbc52c> │ │ │ │ + ldm r2, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bleq 23dcac <__time64@plt+0x23c4f4> │ │ │ │ + blvs 33dcf0 <__time64@plt+0x33c538> │ │ │ │ + blvc 23dcf4 <__time64@plt+0x23c53c> │ │ │ │ + blvc 1fdf34 <__time64@plt+0x1fc77c> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7] │ │ │ │ + vldr d6, [r7, #72] @ 0x48 │ │ │ │ + vmul.f64 d7, d6, d14 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d8 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vldr d5, [r7, #64] @ 0x40 │ │ │ │ + vmul.f64 d7, d5, d10 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc bdcd8 <__time64@plt+0xbc520> │ │ │ │ + blvs 43dd2c <__time64@plt+0x43c574> │ │ │ │ + blvc 3bdd30 <__time64@plt+0x3bc578> │ │ │ │ + blvs 1fdf70 <__time64@plt+0x1fc7b8> │ │ │ │ + blvc 23dd38 <__time64@plt+0x23c580> │ │ │ │ + blvs 1fdf78 <__time64@plt+0x1fc7c0> │ │ │ │ + blpl 4bdd40 <__time64@plt+0x4bc588> │ │ │ │ + blvc 2bdd44 <__time64@plt+0x2bc58c> │ │ │ │ + blvc 1fdf80 <__time64@plt+0x1fc7c8> │ │ │ │ + blvc 1fdfc8 <__time64@plt+0x1fc810> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7, #16] │ │ │ │ + vldr d6, [r7, #48] @ 0x30 │ │ │ │ + vmul.f64 d7, d6, d10 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 23dd14 <__time64@plt+0x23c55c> │ │ │ │ + blvs 4bdd68 <__time64@plt+0x4bc5b0> │ │ │ │ + blvc 3bdd6c <__time64@plt+0x3bc5b4> │ │ │ │ + blvs 1fdfac <__time64@plt+0x1fc7f4> │ │ │ │ + blvc 2bdd74 <__time64@plt+0x2bc5bc> │ │ │ │ + blvs 1fdfb4 <__time64@plt+0x1fc7fc> │ │ │ │ + blpl 43dd7c <__time64@plt+0x43c5c4> │ │ │ │ + blvc 23dd80 <__time64@plt+0x23c5c8> │ │ │ │ + blvc 1fdfbc <__time64@plt+0x1fc804> │ │ │ │ + blvc 1fe004 <__time64@plt+0x1fc84c> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7, #40] @ 0x28 │ │ │ │ + vldr d6, [r7, #64] @ 0x40 │ │ │ │ + vmul.f64 d7, d6, d14 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d10 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vldr d5, [r7, #72] @ 0x48 │ │ │ │ + vmul.f64 d7, d5, d8 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 33dd68 <__time64@plt+0x33c5b0> │ │ │ │ + blvc 3bddbc <__time64@plt+0x3bc604> │ │ │ │ + blvc 11fe228 <__time64@plt+0x11fca70> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7, #64] @ 0x40 │ │ │ │ + vldr d6, [r7, #72] @ 0x48 │ │ │ │ + vmul.f64 d7, d6, d12 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 4bdd88 <__time64@plt+0x4bc5d0> │ │ │ │ + blvs 43dddc <__time64@plt+0x43c624> │ │ │ │ + blvc 33dde0 <__time64@plt+0x33c628> │ │ │ │ + blvc 1fe020 <__time64@plt+0x1fc868> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdavs r9!, {r2, r4, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - eorlt sp, r7, r9, lsl r1 │ │ │ │ - blhi bd170 <__time64@plt+0xbb8f4> │ │ │ │ - mrc 13, 5, fp, cr1, cr0, {7} │ │ │ │ - stmib sp, {r3, r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - stmib sp, {r1, r2, r3, r8, r9, sl, sp, lr}^ │ │ │ │ - stc 7, cr6, [sp, #16] │ │ │ │ - vstr d8, [sp, #48] @ 0x30 │ │ │ │ - strb r7, [r1, r6, lsl #22]! │ │ │ │ - blvc 123d95c <__time64@plt+0x123c0e0> │ │ │ │ - ldrvs lr, [r8, -sp, asr #19] │ │ │ │ - strvs lr, [r4, -sp, asr #19] │ │ │ │ - blhi 23d4d8 <__time64@plt+0x23bc5c> │ │ │ │ - blvc 53d4dc <__time64@plt+0x53bc60> │ │ │ │ - @ instruction: 0xf7ffe7d6 │ │ │ │ - svclt 0x0000ebbe │ │ │ │ - strdeq fp, [r0], -r6 │ │ │ │ - andeq r0, r0, ip, lsl r1 │ │ │ │ - andeq r8, r0, r0, lsr #32 │ │ │ │ - muleq r0, sl, r1 │ │ │ │ - vst3.8 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb64afc <__time64@plt+0xfeb63280> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - bmi 1105b74 <__time64@plt+0x11042f8> │ │ │ │ - blmi 1113708 <__time64@plt+0x1111e8c> │ │ │ │ - ldrbtmi fp, [sl], #-167 @ 0xffffff59 │ │ │ │ - strbtmi r4, [r9], -r5, lsl #12 │ │ │ │ - cdp 8, 11, cr10, cr7, cr2, {0} │ │ │ │ - ldmpl r3, {r8, r9, fp, ip, sp, pc}^ │ │ │ │ - @ instruction: 0x9325681b │ │ │ │ + tstcs r6, #3162112 @ 0x304000 │ │ │ │ + ldmib r3, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ + ldmdavs r9!, {r1, r2, r4, r8, r9, sp}^ │ │ │ │ + movwcs lr, #59841 @ 0xe9c1 │ │ │ │ + ldmib r3, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ + ldmdavs r9!, {r1, r2, r3, r8, r9, sp}^ │ │ │ │ + movwcs lr, #27073 @ 0x69c1 │ │ │ │ + @ instruction: 0xf04f6879 │ │ │ │ + @ instruction: 0xf04f0200 │ │ │ │ + stmib r1, {r8, r9}^ │ │ │ │ + ldmdavs fp!, {r2, r3, r4, r8, r9, sp}^ │ │ │ │ + tstcs ip, #3457024 @ 0x34c000 │ │ │ │ + stmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ + ldmdavs fp!, {r1, r3, r4, r8, r9, sp}^ │ │ │ │ + tstcs sl, #3457024 @ 0x34c000 │ │ │ │ + stmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ + ldmdavs r9!, {r3, r4, r8, r9, sp}^ │ │ │ │ + andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - bl fe53fef0 <__time64@plt+0xfe53e674> │ │ │ │ - blls bd548 <__time64@plt+0xbbccc> │ │ │ │ - vldr d10, [r4, #16] │ │ │ │ - ldrmi sl, [r8], -r0, lsl #22 │ │ │ │ - blvs 13d554 <__time64@plt+0x13bcd8> │ │ │ │ - cdp 2, 2, cr2, cr9, cr0, {4} │ │ │ │ - vldr d7, [sp, #36] @ 0x24 │ │ │ │ - vmla.f64 d12, d10, d0 │ │ │ │ - ldmdbmi r6!, {r1, r3, r8, r9, fp, ip, sp, lr} │ │ │ │ - blle bd58c <__time64@plt+0xbbd10> │ │ │ │ - mcr 4, 0, r4, cr6, cr9, {3} │ │ │ │ - vmov.f64 d7, #22 @ 0x40b00000 5.5 │ │ │ │ - @ instruction: 0xee8b5bc7 │ │ │ │ - vadd.f64 d8, d11, d5 │ │ │ │ - vnmul.f64 d11, d10, d12 │ │ │ │ - vmul.f64 d10, d9, d8 │ │ │ │ - vmul.f64 d9, d8, d8 │ │ │ │ - @ instruction: 0xf7ff8b06 │ │ │ │ - vmov.f64 d14, d16 │ │ │ │ - strtmi r6, [sl], -ip, asr #22 │ │ │ │ - strtmi r4, [r8], -r1, lsl #12 │ │ │ │ - blpl 2bd7f0 <__time64@plt+0x2bbf74> │ │ │ │ - blmi 27d7f0 <__time64@plt+0x27bf74> │ │ │ │ - blvc 27d7f8 <__time64@plt+0x27bf7c> │ │ │ │ - blvs 2fd768 <__time64@plt+0x2fbeec> │ │ │ │ - blpl 133da18 <__time64@plt+0x133c19c> │ │ │ │ - blpl 2fd76c <__time64@plt+0x2fbef0> │ │ │ │ - blvc 2fd7fc <__time64@plt+0x2fbf80> │ │ │ │ - blvs 13d598 <__time64@plt+0x13bd1c> │ │ │ │ - blvs 23d810 <__time64@plt+0x23bf94> │ │ │ │ - blpl 3bd5a0 <__time64@plt+0x3bbd24> │ │ │ │ - blpl 23d814 <__time64@plt+0x23bf98> │ │ │ │ - blge 37d81c <__time64@plt+0x37bfa0> │ │ │ │ - blls 37d81c <__time64@plt+0x37bfa0> │ │ │ │ - blle 37d81c <__time64@plt+0x37bfa0> │ │ │ │ - blhi 23d820 <__time64@plt+0x23bfa4> │ │ │ │ - blvs 2fd81c <__time64@plt+0x2fbfa0> │ │ │ │ - blpl 2fd81c <__time64@plt+0x2fbfa0> │ │ │ │ - blgt 2fd7ac <__time64@plt+0x2fbf30> │ │ │ │ - blcs 127d868 <__time64@plt+0x127bfec> │ │ │ │ - blvs 27d86c <__time64@plt+0x27bff0> │ │ │ │ - blcc 12bd86c <__time64@plt+0x12bbff0> │ │ │ │ - blpl 2bd870 <__time64@plt+0x2bbff4> │ │ │ │ - blcs 53d5d4 <__time64@plt+0x53bd58> │ │ │ │ - blcc 43d5d8 <__time64@plt+0x43bd5c> │ │ │ │ - blcc 37d884 <__time64@plt+0x37c008> │ │ │ │ - blvc 137d888 <__time64@plt+0x137c00c> │ │ │ │ - blpl 5bd5e4 <__time64@plt+0x5bbd68> │ │ │ │ - blgt 63d5e8 <__time64@plt+0x63bd6c> │ │ │ │ - blvs 23d5ec <__time64@plt+0x23bd70> │ │ │ │ - blcc 33d5f0 <__time64@plt+0x33bd74> │ │ │ │ - blvc 1bd5f4 <__time64@plt+0x1bbd78> │ │ │ │ - mcr2 7, 0, pc, cr4, cr15, {7} @ │ │ │ │ - blmi 2147f0 <__time64@plt+0x212f74> │ │ │ │ - ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 95c038 <__time64@plt+0x95a7bc> │ │ │ │ - @ instruction: 0xf04f405a │ │ │ │ - mrsle r0, SP_svc │ │ │ │ - ldc 0, cr11, [sp], #156 @ 0x9c │ │ │ │ - vldmdblt r0!, {d8-d13} │ │ │ │ - bl 8bffe0 <__time64@plt+0x8be764> │ │ │ │ - andeq fp, r0, r6, lsr #2 │ │ │ │ - andeq r0, r0, ip, lsl r1 │ │ │ │ - andeq r7, r0, r0, lsr pc │ │ │ │ - andeq fp, r0, r8, lsr r0 │ │ │ │ - vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb64c18 <__time64@plt+0xfeb6339c> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - @ instruction: 0xf8df0f58 │ │ │ │ - adclt lr, r2, ip, rrx │ │ │ │ - ldrdgt pc, [r8], #-143 @ 0xffffff71 @ │ │ │ │ - blge 103dad4 <__time64@plt+0x103c258> │ │ │ │ - mrc 4, 5, r4, cr0, cr14, {7} │ │ │ │ - vmov.f64 d9, d1 │ │ │ │ - ldmdbmi r7, {r1, r6, r8, r9, fp, pc} │ │ │ │ - strmi r4, [r4], -fp, ror #12 │ │ │ │ - andgt pc, ip, lr, asr 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cr11, [r0, #536] @ 0x218 │ │ │ │ - vldr d6, [r0, #56] @ 0x38 │ │ │ │ - vmov.32 r7, d5[1] │ │ │ │ - vadd.f64 d5, d6, d0 │ │ │ │ - vadd.f64 d6, d7, d1 │ │ │ │ - vstr d7, [r0, #8] │ │ │ │ - vstr d5, [r0, #24] │ │ │ │ - vstr d6, [r0, #56] @ 0x38 │ │ │ │ - andlt r7, r6, r6, lsl fp │ │ │ │ - svclt 0x00004770 │ │ │ │ - blpl 1bd6f4 <__time64@plt+0x1bbe78> │ │ │ │ - blvs 3bd6f8 <__time64@plt+0x3bbe7c> │ │ │ │ - blvc 5bd6fc <__time64@plt+0x5bbe80> │ │ │ │ - blpl 3d994 <__time64@plt+0x3c118> │ │ │ │ - blvs 7d99c <__time64@plt+0x7c120> │ │ │ │ - blvc bd9a4 <__time64@plt+0xbc128> │ │ │ │ - blpl 1bd6cc <__time64@plt+0x1bbe50> │ │ │ │ - blvs 3bd6d0 <__time64@plt+0x3bbe54> │ │ │ │ - blvc 5bd6d4 <__time64@plt+0x5bbe58> │ │ │ │ - svclt 0x00004770 │ │ │ │ - blne bd71c <__time64@plt+0xbbea0> │ │ │ │ - blcc bd724 <__time64@plt+0xbbea8> │ │ │ │ - blvc 2bd728 <__time64@plt+0x2bbeac> │ │ │ │ - blvs 4bd72c <__time64@plt+0x4bbeb0> │ │ │ │ - bleq 3d72c <__time64@plt+0x3beb0> │ │ │ │ - blmi 23d734 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r7, cr7, cr0, {7} │ │ │ │ - vstr d6, [r4, #44] @ 0x2c │ │ │ │ - vmul.f64 d3, d7, d0 │ │ │ │ - vmul.f64 d3, d7, d8 │ │ │ │ - vmul.f64 d2, d7, d10 │ │ │ │ - stmib r4, {r0, r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - mrc 1, 0, r0, cr6, cr14, {0} │ │ │ │ - stmib r4, {r1, r3, r8, r9, fp, lr}^ │ │ │ │ - stc 3, cr2, [r4, #88] @ 0x58 │ │ │ │ - vmov.32 d5[1], r3 │ │ │ │ - vmul.f64 d3, d8, d8 │ │ │ │ - stmib r4, {r0, r3, r8, r9, fp, pc}^ │ │ │ │ - stmib r4, {r1, r2, r3, r8, r9, sp}^ │ │ │ │ - stmib r4, {r1, r2, r8, r9, sp}^ │ │ │ │ - stmib r4, {r2, r3, r4, r8, r9, sp}^ │ │ │ │ - stmib r4, {r1, r3, r4, r8, r9, sp}^ │ │ │ │ - stc 3, cr2, [r4, #96] @ 0x60 │ │ │ │ - vstr d3, [r4, #80] @ 0x50 │ │ │ │ - vmul.f64 d4, d5, d2 │ │ │ │ - vmul.f64 d4, d5, d11 │ │ │ │ - vmov.f64 d5, #26 @ 0x40d00000 6.5 │ │ │ │ - vmls.f64 d11, d6, d11 │ │ │ │ - vstr d5, [r4, #36] @ 0x24 │ │ │ │ - vmla.f64 d8, d4, d8 │ │ │ │ - vnmls.f64 d7, d4, d10 │ │ │ │ - vstr d2, [r4, #36] @ 0x24 │ │ │ │ - vstr d11, [r4, #64] @ 0x40 │ │ │ │ - vstr d5, [r4, #40] @ 0x28 │ │ │ │ - vstr d7, [r4, #16] │ │ │ │ - andlt r2, r4, ip, lsl #22 │ │ │ │ - blhi 23d680 <__time64@plt+0x23be04> │ │ │ │ - svclt 0x0000bd70 │ │ │ │ - vst3. {d27,d29,d31}, [pc :256], r8 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb64fa4 <__time64@plt+0xfeb63728> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - vldr , [r0, #384] @ 0x180 │ │ │ │ - @ instruction: 0x46048b10 │ │ │ │ - blne 3d9ec <__time64@plt+0x3c170> │ │ │ │ - ldc 6, cr4, [r0, #116] @ 0x74 │ │ │ │ - strmi r0, [lr], -r8, lsl #22 │ │ │ │ - mrc 6, 5, r4, cr1, cr7, {0} │ │ │ │ - @ instruction: 0xf7ff8b48 │ │ │ │ - @ instruction: 0xeeb0ea50 │ │ │ │ - vmov.f64 d7, d0 │ │ │ │ - vstr d0, [r5, #288] @ 0x120 │ │ │ │ - @ instruction: 0xf7ff7b00 │ │ │ │ - @ instruction: 0xed87e9d6 │ │ │ │ - vldr d0, [r4] │ │ │ │ - vldr d1, [r4, #80] @ 0x50 │ │ │ │ - @ instruction: 0xf7ff0b12 │ │ │ │ - vstr s28, [r6, #256] @ 0x100 │ │ │ │ - vldr d0, [r5] │ │ │ │ - vmov.f64 d7, #80 @ 0x3e800000 0.250 │ │ │ │ - vsqrt.f64 d23, d0 │ │ │ │ - strle pc, [r5, #-2576] @ 0xfffff5f0 │ │ │ │ - blvs 13da70 <__time64@plt+0x13c1f4> │ │ │ │ - blvc 1bdcd4 <__time64@plt+0x1bc458> │ │ │ │ - blvc 3da10 <__time64@plt+0x3c194> │ │ │ │ - blhi bd6f4 <__time64@plt+0xbbe78> │ │ │ │ - svclt 0x0000bdf8 │ │ │ │ + mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ + tstcs lr, #3162112 @ 0x304000 │ │ │ │ + ldrbcc fp, [r0, -r0, lsl #30] │ │ │ │ + stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ + addlt fp, r6, r0, lsl #11 │ │ │ │ + rscsvs sl, r8, r0, lsl #30 │ │ │ │ + ldrhtvs r6, [sl], #-9 │ │ │ │ + ldmvs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ + blvc 43de54 <__time64@plt+0x43c69c> │ │ │ │ + blvc 11fe2d0 <__time64@plt+0x11fcb18> │ │ │ │ + blvc 13de2c <__time64@plt+0x13c674> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 3de68 <__time64@plt+0x3c6b0> │ │ │ │ + blne 11be2e0 <__time64@plt+0x11bcb28> │ │ │ │ + bleq 11fe2e4 <__time64@plt+0x11fcb2c> │ │ │ │ + svc 0x00b8f7fe │ │ │ │ + blvc 103e2ec <__time64@plt+0x103cb34> │ │ │ │ + stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ + vldr d7, [r7] │ │ │ │ + @ instruction: 0xf7fe0b04 │ │ │ │ + mrc 15, 5, lr, cr0, cr14, {1} │ │ │ │ + ldmdavs fp!, {r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 3de50 <__time64@plt+0x3c698> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r1, r4, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 53de9c <__time64@plt+0x53c6e4> │ │ │ │ + blne 11be314 <__time64@plt+0x11bcb5c> │ │ │ │ + bleq 11fe318 <__time64@plt+0x11fcb60> │ │ │ │ + svc 0x009ef7fe │ │ │ │ + blvc 103e320 <__time64@plt+0x103cb68> │ │ │ │ + stc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + ldmdavs fp!, {r8, r9, fp, ip, sp, lr} │ │ │ │ + blvc 3deb8 <__time64@plt+0x3c700> │ │ │ │ + blvc ff03e344 <__time64@plt+0xff03cb8c> │ │ │ │ + blx 43e438 <__time64@plt+0x43cc80> │ │ │ │ + and sp, r9, r0, lsl #8 │ │ │ │ + ldc 8, cr6, [r3, #236] @ 0xec │ │ │ │ + vldr d7, [pc] @ 2880 <__time64@plt+0x10c8> │ │ │ │ + vadd.f64 d6, d7, d5 │ │ │ │ + ldmdavs fp!, {r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ + blvc 3de98 <__time64@plt+0x3c6e0> │ │ │ │ + ldrcc fp, [r8, -r0, lsl #30] │ │ │ │ + stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ @ instruction: 0x401921fb │ │ │ │ - vst3.8 {d27,d29,d31}, [pc], r0 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb65058 <__time64@plt+0xfeb637dc> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - selmi r0, r4, r0 │ │ │ │ - blmi 3dee4 <__time64@plt+0x3c668> │ │ │ │ - strmi fp, [fp], -r3, lsl #1 │ │ │ │ - addcs r4, r0, #819200 @ 0xc8000 │ │ │ │ - blne 13daa0 <__time64@plt+0x13c224> │ │ │ │ - ldc 6, cr4, [ip, #96] @ 0x60 │ │ │ │ - ldrbtmi lr, [r9], #-2818 @ 0xfffff4fe │ │ │ │ - blls 1bdaac <__time64@plt+0x1bc230> │ │ │ │ - blcc 7dcc4 <__time64@plt+0x7c448> │ │ │ │ - blgt 3dab4 <__time64@plt+0x3c238> │ │ │ │ - blcc 3bdc80 <__time64@plt+0x3bc404> │ │ │ │ - blcc 27dc70 <__time64@plt+0x27c3f4> │ │ │ │ - blcc 33dc80 <__time64@plt+0x33c404> │ │ │ │ - blcs fde64 <__time64@plt+0xfc5e8> │ │ │ │ - blcc bdcdc <__time64@plt+0xbc460> │ │ │ │ - blx bdd02 <__time64@plt+0xbc486> │ │ │ │ - blcs bdd18 <__time64@plt+0xbc49c> │ │ │ │ - blle fdd1c <__time64@plt+0xfc4a0> │ │ │ │ - blge fdd18 <__time64@plt+0xfc49c> │ │ │ │ - blcc fdcf0 <__time64@plt+0xfc474> │ │ │ │ - blhi bdd28 <__time64@plt+0xbc4ac> │ │ │ │ - blls 3fdd18 <__time64@plt+0x3fc49c> │ │ │ │ - bllt bdd28 <__time64@plt+0xbc4ac> │ │ │ │ - bl 3fdd34 <__time64@plt+0x3fc4b8> │ │ │ │ - blgt 3fdd30 <__time64@plt+0x3fc4b4> │ │ │ │ - blx 3fdd0a <__time64@plt+0x3fc48e> │ │ │ │ - blcc 3dabc <__time64@plt+0x3c240> │ │ │ │ - ldm r6!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blcc 3db04 <__time64@plt+0x3c288> │ │ │ │ - blvs 27dd74 <__time64@plt+0x27c4f8> │ │ │ │ - blcs 3df74 <__time64@plt+0x3c6f8> │ │ │ │ - blvc 27dd68 <__time64@plt+0x27c4ec> │ │ │ │ - blcc fdd80 <__time64@plt+0xfc504> │ │ │ │ - blvs 11bdd6c <__time64@plt+0x11bc4f0> │ │ │ │ - blvc 11fdd70 <__time64@plt+0x11fc4f4> │ │ │ │ - blcs 10fdd74 <__time64@plt+0x10fc4f8> │ │ │ │ - blvs 2bdab0 <__time64@plt+0x2bc234> │ │ │ │ - blcc 3bdd9c <__time64@plt+0x3bc520> │ │ │ │ - blvs 133ddac <__time64@plt+0x133c530> │ │ │ │ - blge 12bddb4 <__time64@plt+0x12bc538> │ │ │ │ - blgt 37ddb0 <__time64@plt+0x37c534> │ │ │ │ - blvc 3dac4 <__time64@plt+0x3c248> │ │ │ │ - blvc 3fddb4 <__time64@plt+0x3fc538> │ │ │ │ - bllt 12fddc8 <__time64@plt+0x12fc54c> │ │ │ │ - blcs 53dad0 <__time64@plt+0x53c254> │ │ │ │ - blcc 43dad4 <__time64@plt+0x43c258> │ │ │ │ - blge 13dad8 <__time64@plt+0x13c25c> │ │ │ │ - blvc 33dadc <__time64@plt+0x33c260> │ │ │ │ - bllt 4bdae0 <__time64@plt+0x4bc264> │ │ │ │ - blvs 23dae4 <__time64@plt+0x23c268> │ │ │ │ - blgt bdae8 <__time64@plt+0xbc26c> │ │ │ │ - ldc 0, cr11, [sp], #12 │ │ │ │ - @ instruction: 0xf85d8b10 │ │ │ │ - svclt 0x0000fb04 │ │ │ │ - andeq r7, r0, r2, lsl sl │ │ │ │ - blmi 3db3c <__time64@plt+0x3c2c0> │ │ │ │ - blpl 2bdb40 <__time64@plt+0x2bc2c4> │ │ │ │ - bleq 53db44 <__time64@plt+0x53c2c8> │ │ │ │ - blvc 17ddd8 <__time64@plt+0x17c55c> │ │ │ │ - blvs 3dde8 <__time64@plt+0x3c56c> │ │ │ │ - blvs ff03dfe4 <__time64@plt+0xff03c768> │ │ │ │ - blx 43e0d8 <__time64@plt+0x43c85c> │ │ │ │ - addhi pc, sp, r0, lsl #6 │ │ │ │ - mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ - stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - @ instruction: 0x0c0cebad │ │ │ │ - svceq 0x00d0f8cc │ │ │ │ - blmi ff17dffc <__time64@plt+0xff17c780> │ │ │ │ - addlt r2, r5, r8, lsr #6 │ │ │ │ - stmdaeq r8, {r0, r8, ip, sp, lr, pc} │ │ │ │ - blx 43e0fc <__time64@plt+0x43c880> │ │ │ │ - strcs fp, [r1, -ip, asr #30] │ │ │ │ - blx cc142 <__time64@plt+0xca8c6> │ │ │ │ - ldc 2, cr0, [r2, #28] │ │ │ │ - vmov.f64 d6, #64 @ 0x3e000000 0.125 │ │ │ │ - vsqrt.f64 d16, d6 │ │ │ │ - @ instruction: 0xdc68fa10 │ │ │ │ - blx 1c274a <__time64@plt+0x1c0ece> │ │ │ │ - @ instruction: 0xf1c53203 │ │ │ │ - cdp 5, 11, cr0, cr0, cr2, {0} │ │ │ │ - strmi r0, [r2], #-2886 @ 0xfffff4ba │ │ │ │ - b 13c9754 <__time64@plt+0x13c7ed8> │ │ │ │ - blx c4c7e <__time64@plt+0xc3402> │ │ │ │ - bl 203180 <__time64@plt+0x201904> │ │ │ │ - ldc 6, cr0, [r2, #784] @ 0x310 │ │ │ │ - vldr d7, [r3] │ │ │ │ - rscseq r6, fp, r0, lsl #22 │ │ │ │ - blvc 1bde58 <__time64@plt+0x1bc5dc> │ │ │ │ - bleq 11fde40 <__time64@plt+0x11fc5c4> │ │ │ │ - blvc 3e060 <__time64@plt+0x3c7e4> │ │ │ │ - bleq 1fde48 <__time64@plt+0x1fc5cc> │ │ │ │ - bleq 103e060 <__time64@plt+0x103c7e4> │ │ │ │ - blx 43e154 <__time64@plt+0x43c8d8> │ │ │ │ - mrc 4, 5, sp, cr1, cr12, {3} │ │ │ │ - vrintz.f64 d7, d0 │ │ │ │ - strbmi r6, [r3], #-2816 @ 0xfffff500 │ │ │ │ - vmlaeq.f64 d14, d9, d8 │ │ │ │ - vstmiaeq r7, {s28-s106} │ │ │ │ - blpl 1fdfc0 <__time64@plt+0x1fc744> │ │ │ │ - blvc 1bde48 <__time64@plt+0x1bc5cc> │ │ │ │ - stmibeq r5, {r0, r1, r2, r3, r6, r9, fp, sp, lr, pc} │ │ │ │ - bl 8283c <__time64@plt+0x80fc0> │ │ │ │ - ldrtmi r0, [sl], #-2053 @ 0xfffff7fb │ │ │ │ - blvc 3dbc8 <__time64@plt+0x3c34c> │ │ │ │ - movweq lr, #23308 @ 0x5b0c │ │ │ │ - strbmi r4, [ip], #-1188 @ 0xfffffb5c │ │ │ │ - streq lr, [r7, #-2825] @ 0xfffff4f7 │ │ │ │ - sbceq lr, r2, #0, 22 │ │ │ │ - strbeq lr, [r4], #2816 @ 0xb00 │ │ │ │ - strbeq lr, [r8, r0, lsl #22] │ │ │ │ - biceq lr, r3, #0, 22 │ │ │ │ - blmi 3dc24 <__time64@plt+0x3c3a8> │ │ │ │ - blcc 3dc30 <__time64@plt+0x3c3b4> │ │ │ │ - strbeq lr, [ip], #2816 @ 0xb00 │ │ │ │ - blvs 3dc44 <__time64@plt+0x3c3c8> │ │ │ │ - sbceq lr, r5, r0, lsl #22 │ │ │ │ - blvc 3dc40 <__time64@plt+0x3c3c4> │ │ │ │ - blvs fdecc <__time64@plt+0xfc650> │ │ │ │ - blvc 13ded4 <__time64@plt+0x13c658> │ │ │ │ - blvs 17de94 <__time64@plt+0x17c618> │ │ │ │ - blvc 17de9c <__time64@plt+0x17c620> │ │ │ │ - blvs 3dc08 <__time64@plt+0x3c38c> │ │ │ │ - blvc 3dc20 <__time64@plt+0x3c3a4> │ │ │ │ - blvc 3dc58 <__time64@plt+0x3c3dc> │ │ │ │ - blvs 3dc50 <__time64@plt+0x3c3d4> │ │ │ │ - blvc 1bdef0 <__time64@plt+0x1bc674> │ │ │ │ - blvc 17deb4 <__time64@plt+0x17c638> │ │ │ │ - blvc 3dc54 <__time64@plt+0x3c3d8> │ │ │ │ - pop {r0, r2, ip, sp, pc} │ │ │ │ - @ instruction: 0x464683f0 │ │ │ │ - stmdbeq r8, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ - strcs r2, [r1, #-784] @ 0xfffffcf0 │ │ │ │ - strcs r2, [r2, -r0, lsl #8] │ │ │ │ - cdp 7, 11, cr14, cr7, cr4, {5} │ │ │ │ - vldr d7, [r0] │ │ │ │ - vldr d4, [r0, #72] @ 0x48 │ │ │ │ - vmov.f64 d3, #108 @ 0x3f600000 0.875 │ │ │ │ - vadd.f64 d1, d6, d0 │ │ │ │ - vldr d6, [r0, #28] │ │ │ │ - vldr d2, [r0, #32] │ │ │ │ - vadd.f64 d7, d3, d2 │ │ │ │ - vldr d3, [r0, #272] @ 0x110 │ │ │ │ - vldr d5, [r0, #64] @ 0x40 │ │ │ │ - vmov.f64 d0, #20 @ 0x40a00000 5.0 │ │ │ │ - vsub.f64 d4, d23, d6 │ │ │ │ - vsub.f64 d7, d5, d2 │ │ │ │ - @ instruction: 0xee816b40 │ │ │ │ - vmul.f64 d2, d4, d4 │ │ │ │ - vstr d4, [r1, #4] │ │ │ │ - vmul.f64 d4, d3, d0 │ │ │ │ - vmul.f64 d3, d6, d2 │ │ │ │ - vmul.f64 d6, d7, d2 │ │ │ │ - vstr d7, [r1, #8] │ │ │ │ - vstr d3, [r1, #8] │ │ │ │ - vstr d6, [r1, #16] │ │ │ │ - ldrbmi r7, [r0, -r6, lsl #22]! │ │ │ │ - smlabteq r2, sp, r9, lr │ │ │ │ - @ instruction: 0xf7ff9301 │ │ │ │ - ldmib sp, {r3, r6, fp, sp, lr, pc}^ │ │ │ │ - cdp 1, 11, cr0, cr0, cr2, {0} │ │ │ │ - blls 613a0 <__time64@plt+0x5fb24> │ │ │ │ - svclt 0x0000e779 │ │ │ │ - vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - stc 12, cr5, [sp, #-512]! @ 0xfffffe00 │ │ │ │ - bl feb652f0 <__time64@plt+0xfeb63a74> │ │ │ │ - @ instruction: 0xf8cc0c0c │ │ │ │ - vldr , [r0, #192] @ 0xc0 │ │ │ │ - vmov.f64 d8, #4 @ 0x40200000 2.5 │ │ │ │ - vldr d11, [r0, #256] @ 0x100 │ │ │ │ - vmov.f64 d15, #114 @ 0x3f900000 1.125 │ │ │ │ - vldr d9, [r0] │ │ │ │ - ldrmi lr, [r4], -r6, lsl #22 │ │ │ │ - bleq 23df70 <__time64@plt+0x23c6f4> │ │ │ │ - blge 3dd14 <__time64@plt+0x3c498> │ │ │ │ - bleq 3fdf14 <__time64@plt+0x3fc698> │ │ │ │ - blvc 113dd58 <__time64@plt+0x113c4dc> │ │ │ │ - bleq 3bdf18 <__time64@plt+0x3bc69c> │ │ │ │ - bleq 2bdf0c <__time64@plt+0x2bc690> │ │ │ │ - blvs 27dfa8 <__time64@plt+0x27c72c> │ │ │ │ - blvs ff1fe1bc <__time64@plt+0xff1fc940> │ │ │ │ - blx 43e2b4 <__time64@plt+0x43ca38> │ │ │ │ - cdp 13, 3, cr13, cr9, cr13, {1} │ │ │ │ - strmi r6, [lr], -r0, asr #22 │ │ │ │ - blvs ff1fe1cc <__time64@plt+0xff1fc950> │ │ │ │ - blx 43e2c4 <__time64@plt+0x43ca48> │ │ │ │ - mrc 15, 1, fp, cr9, cr8, {6} │ │ │ │ - mrrcle 11, 4, r9, r8, cr11 │ │ │ │ - blvc bdd64 <__time64@plt+0xbc4e8> │ │ │ │ - blx 27dfce <__time64@plt+0x27c752> │ │ │ │ - blvs 13dd6c <__time64@plt+0x13c4f0> │ │ │ │ - blhi 27dfb8 <__time64@plt+0x27c73c> │ │ │ │ - blpl 1bdd74 <__time64@plt+0x1bc4f8> │ │ │ │ - bl 27dfd8 <__time64@plt+0x27c75c> │ │ │ │ - blx 1fdf52 <__time64@plt+0x1fc6d6> │ │ │ │ - blvc 3dd80 <__time64@plt+0x3c504> │ │ │ │ - blls 27dfd4 <__time64@plt+0x27c758> │ │ │ │ - blhi 1bdf5c <__time64@plt+0x1bc6e0> │ │ │ │ - bl 17df60 <__time64@plt+0x17c6e4> │ │ │ │ - blls 1fdf64 <__time64@plt+0x1fc6e8> │ │ │ │ - blx bdd4e <__time64@plt+0xbc4d2> │ │ │ │ - blhi 13dd50 <__time64@plt+0x13c4d4> │ │ │ │ - bl 1bdd54 <__time64@plt+0x1bc4d8> │ │ │ │ - blls 3dd58 <__time64@plt+0x3c4dc> │ │ │ │ - blhi 43da40 <__time64@plt+0x43c1c4> │ │ │ │ - mrc 13, 5, fp, cr1, cr0, {3} │ │ │ │ - vneg.f64 d8, d8 │ │ │ │ - vsub.f64 d10, d9, d10 │ │ │ │ - vldr d0, [pc, #300] @ 2888 <__time64@plt+0x100c> │ │ │ │ - strmi lr, [r5], -r6, lsr #22 │ │ │ │ - blhi bdd6c <__time64@plt+0xbc4f0> │ │ │ │ - blle bdda8 <__time64@plt+0xbc52c> │ │ │ │ - bleq 3bdfec <__time64@plt+0x3bc770> │ │ │ │ - blge 1bdd78 <__time64@plt+0x1bc4fc> │ │ │ │ - blgt 1bddb4 <__time64@plt+0x1bc538> │ │ │ │ - blle 13dd80 <__time64@plt+0x13c504> │ │ │ │ - blgt 3dd84 <__time64@plt+0x3c508> │ │ │ │ - svc 0x00c0f7fe │ │ │ │ - blls 103e244 <__time64@plt+0x103c9c8> │ │ │ │ - bleq 3be034 <__time64@plt+0x3bc7b8> │ │ │ │ - svc 0x00baf7fe │ │ │ │ - blhi 3e030 <__time64@plt+0x3c7b4> │ │ │ │ - blge 3e03c <__time64@plt+0x3c7c0> │ │ │ │ - blvc 13ddec <__time64@plt+0x13c570> │ │ │ │ - blhi 27dfd0 <__time64@plt+0x27c754> │ │ │ │ - blge 27dfd0 <__time64@plt+0x27c754> │ │ │ │ - blvs 3e058 <__time64@plt+0x3c7dc> │ │ │ │ - blvs 1fdfcc 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<__time64@plt+0x13c750> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d4 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 1bdf1c <__time64@plt+0x1bc764> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d6 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 3df30 <__time64@plt+0x3c778> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vmul.f64 d7, d5, d0 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + vmov.f64 d6, #7 @ 0x40380000 2.875 │ │ │ │ + vdiv.f64 d5, d5, d0 │ │ │ │ + vstr d7, [r7, #24] │ │ │ │ + ldmdavs fp!, {r1, r3, r4, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc bdf50 <__time64@plt+0xbc798> │ │ │ │ + blvs 6bdf64 <__time64@plt+0x6bc7ac> │ │ │ │ + blvc 1fe1a4 <__time64@plt+0x1fc9ec> │ │ │ │ + blvc 63df2c <__time64@plt+0x63c774> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7, #16] │ │ │ │ + vmov.32 d6[1], r6 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmdavs fp!, {r1, r2, r4, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 1bdf74 <__time64@plt+0x1bc7bc> │ │ │ │ + blvs 6bdf88 <__time64@plt+0x6bc7d0> │ │ │ │ + blvc 1fe1c8 <__time64@plt+0x1fca10> │ │ │ │ + blvc 53df50 <__time64@plt+0x53c798> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7] │ │ │ │ + vmov.32 d6[1], r6 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmdavs fp!, {r1, r4, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 3df98 <__time64@plt+0x3c7e0> │ │ │ │ + blvs 5bdfac <__time64@plt+0x5bc7f4> │ │ │ │ + blvc 1fe1ec <__time64@plt+0x1fca34> │ │ │ │ + blvc 43df74 <__time64@plt+0x43c7bc> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d7, [r7] │ │ │ │ + vmov.32 d6[1], r6 │ │ │ │ + vstr d7, [r7, #28] │ │ │ │ + ldmdavs fp!, {r1, r2, r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc bdfbc <__time64@plt+0xbc804> │ │ │ │ + blvs 63dfd0 <__time64@plt+0x63c818> │ │ │ │ + blvc 1fe210 <__time64@plt+0x1fca58> │ │ │ │ + blvc 33df98 <__time64@plt+0x33c7e0> │ │ │ │ + ldc 8, cr6, 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{r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ + ldmdbvs fp!, {r0, r3, r4, r7}^ │ │ │ │ + sbcseq r4, fp, fp, lsl #8 │ │ │ │ + ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ + vadd.f64 d7, d6, d0 │ │ │ │ + vldr d6, [r7, #28] │ │ │ │ + vmul.f64 d7, d6, d2 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ + blvc 3e2a4 <__time64@plt+0x3caec> │ │ │ │ + bvs 1edce84 <__time64@plt+0x1edb6cc> │ │ │ │ + ldmdbvs fp!, {r0, r3, r4, r7}^ │ │ │ │ + sbcseq r4, fp, fp, lsl #8 │ │ │ │ + ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ + ldmdavs sl!, {r8, r9, fp, sp, lr}^ │ │ │ │ + addseq r6, r9, fp, ror r9 │ │ │ │ + strmi r6, [fp], #-2683 @ 0xfffff585 │ │ │ │ + ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ + blvc 3e308 <__time64@plt+0x3cb50> │ │ │ │ + blvs 1fe598 <__time64@plt+0x1fcde0> │ │ │ │ + sbcseq r6, fp, fp, ror r9 │ │ │ │ + ldrmi r6, [r3], #-2618 @ 0xfffff5c6 │ │ │ │ + blvc be328 <__time64@plt+0xbcb70> │ │ │ │ + blvc 1fe568 <__time64@plt+0x1fcdb0> │ │ │ │ + blvc 3e2e0 <__time64@plt+0x3cb28> │ │ │ │ + bvs 1edcec0 <__time64@plt+0x1edb708> │ │ │ │ + ldmdbvs fp!, {r0, r3, r4, r7} │ │ │ │ + sbcseq r4, fp, fp, lsl #8 │ │ │ │ + ldc 4, cr4, [r3, #76] @ 0x4c │ │ │ │ + ldmdavs sl!, {r8, r9, fp, sp, lr}^ │ │ │ │ + addseq r6, r9, fp, lsr r9 │ │ │ │ + strmi r6, [fp], #-2683 @ 0xfffff585 │ │ │ │ + ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ + blvc 3e344 <__time64@plt+0x3cb8c> │ │ │ │ + blvs 1fe5d4 <__time64@plt+0x1fce1c> │ │ │ │ + sbcseq r6, fp, fp, lsr r9 │ │ │ │ + ldrmi r6, [r3], #-2618 @ 0xfffff5c6 │ │ │ │ + blvc be364 <__time64@plt+0xbcbac> │ │ │ │ + blvc 1fe5a4 <__time64@plt+0x1fcdec> │ │ │ │ + blvc 3e31c <__time64@plt+0x3cb64> │ │ │ │ + strcc fp, [r8, -r0, lsl #30]! │ │ │ │ + stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ + addslt fp, r0, r0, lsl #11 │ │ │ │ + cmnvs r8, r0, lsl #30 │ │ │ │ + stc 1, cr6, [r7, #228] @ 0xe4 │ │ │ │ + rsbsvs r0, sl, r2, lsl #22 │ │ │ │ + @ instruction: 0xed93697b │ │ │ │ + ldmdbvs fp!, {r1, r8, r9, fp, sp, lr}^ │ │ │ │ + blvc be380 <__time64@plt+0xbcbc8> │ │ │ │ + blvs 1fe5d0 <__time64@plt+0x1fce18> │ │ │ │ + @ instruction: 0xed93697b │ │ │ │ + ldmdbvs fp!, {r2, r8, r9, fp, ip, lr}^ │ │ │ │ + blvc 13e390 <__time64@plt+0x13cbd8> │ │ │ │ + blvc 1fe5dc <__time64@plt+0x1fce24> │ │ │ │ + blvs 1fe624 <__time64@plt+0x1fce6c> │ │ │ │ + @ instruction: 0xed93697b │ │ │ │ + ldmdbvs fp!, {r1, r2, r8, r9, fp, ip, lr}^ │ │ │ │ + blvc 1be3a4 <__time64@plt+0x1bcbec> │ │ │ │ + blvc 1fe5f0 <__time64@plt+0x1fce38> │ │ │ │ + blvs 1fe638 <__time64@plt+0x1fce80> │ │ │ │ + @ instruction: 0xed93697b │ │ │ │ + ldmdbvs fp!, {r8, r9, fp, ip, lr}^ │ │ │ │ + blvc 3e3b8 <__time64@plt+0x3cc00> │ │ │ │ + blvc 1fe604 <__time64@plt+0x1fce4c> │ │ │ │ + blvc 1fe64c <__time64@plt+0x1fce94> │ │ │ │ + blvc 2be394 <__time64@plt+0x2bcbdc> │ │ │ │ + blvc 2be3d8 <__time64@plt+0x2bcc20> │ │ │ │ + blvs 3e85c <__time64@plt+0x3d0a4> │ │ │ │ + blvc 1be660 <__time64@plt+0x1bcea8> │ │ │ │ + blvs fe2fe404 <__time64@plt+0xfe2fcc4c> │ │ │ │ + blvc ff1be85c <__time64@plt+0xff1bd0a4> │ │ │ │ + blx 43e954 <__time64@plt+0x43d19c> │ │ │ │ + addshi pc, fp, r0, asr #6 │ │ │ │ + blvs 3e874 <__time64@plt+0x3d0bc> │ │ │ │ + blvc 2be3f8 <__time64@plt+0x2bcc40> │ │ │ │ + blvc 11fe678 <__time64@plt+0x11fcec0> │ │ │ │ + blvs fe13e420 <__time64@plt+0xfe13cc68> │ │ │ │ + blvc ff1be878 <__time64@plt+0xff1bd0c0> │ │ │ │ + blx 43e970 <__time64@plt+0x43d1b8> │ │ │ │ + ldc 13, cr13, [r7, #208] @ 0xd0 │ │ │ │ + @ instruction: 0xf7fe0b0a │ │ │ │ + stc 12, cr14, [r7, #32] │ │ │ │ + vldr d0, [r7, #32] │ │ │ │ + @ instruction: 0xf7fe0b08 │ │ │ │ + stc 12, cr14, [r7, #248] @ 0xf8 │ │ │ │ + vmov.f64 d0, #118 @ 0x3fb00000 1.375 │ │ │ │ + vldr d6, [r7] │ │ │ │ + vadd.f64 d7, d6, d2 │ │ │ │ + vldr d6, [r7, #284] @ 0x11c │ │ │ │ + vmul.f64 d7, d6, d8 │ │ │ │ + vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ + @ instruction: 0xf7fe0b47 │ │ │ │ + cdp 12, 11, cr14, cr0, cr14, {1} │ │ │ │ + vldr d5, [r7, #256] @ 0x100 │ │ │ │ + vdiv.f64 d6, d5, d6 │ │ │ │ + vstr d7, [r7, #24] │ │ │ │ + vldr d7, [r7, #56] @ 0x38 │ │ │ │ + vldr d6, [r7, #8] │ │ │ │ + vmul.f64 d7, d6, d8 │ │ │ │ + vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ + @ instruction: 0xf7fe0b47 │ │ │ │ + mrc 12, 5, lr, cr0, cr12, {0} │ │ │ │ + vldr d5, [r7, #256] @ 0x100 │ │ │ │ + vdiv.f64 d6, d5, d6 │ │ │ │ + vstr d7, [r7, #24] │ │ │ │ + and r7, fp, ip, lsl #22 │ │ │ │ + blvs 3e8f8 <__time64@plt+0x3d140> │ │ │ │ + blvc be47c <__time64@plt+0xbccc4> │ │ │ │ + blvc 11fe6fc <__time64@plt+0x11fcf44> │ │ │ │ + blvc 3be444 <__time64@plt+0x3bcc8c> │ │ │ │ + movwcs lr, #10711 @ 0x29d7 │ │ │ │ + movwcs lr, #51655 @ 0xc9c7 │ │ │ │ + @ instruction: 0xed93697b │ │ │ │ + vldr d6, [r7, #8] │ │ │ │ + vmul.f64 d7, d6, d14 │ │ │ │ + ldmdbvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr} │ │ │ │ + blpl be490 <__time64@plt+0xbccd8> │ │ │ │ + blvc 33e4a4 <__time64@plt+0x33ccec> │ │ │ │ + blvc 1fe6e0 <__time64@plt+0x1fcf28> │ │ │ │ + blvc 1fe728 <__time64@plt+0x1fcf70> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdbvs fp!, {r1, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 13e4a8 <__time64@plt+0x13ccf0> │ │ │ │ + blvc 3be4bc <__time64@plt+0x3bcd04> │ │ │ │ + blvs 1fe6fc <__time64@plt+0x1fcf44> │ │ │ │ + @ instruction: 0xed93693b │ │ │ │ + vldr d5, [r7, #16] │ │ │ │ + vmul.f64 d7, d5, d12 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 13e488 <__time64@plt+0x13ccd0> │ │ │ │ + @ instruction: 0xed93697b │ │ │ │ + vldr d6, [r7, #24] │ │ │ │ + vmul.f64 d7, d6, d14 │ │ │ │ + ldmdbvs fp!, {r0, r1, r2, r8, r9, fp, sp, lr} │ │ │ │ + blpl 1be4dc <__time64@plt+0x1bcd24> │ │ │ │ + blvc 33e4f0 <__time64@plt+0x33cd38> │ │ │ │ + blvc 1fe72c <__time64@plt+0x1fcf74> │ │ │ │ + blvc 1fe774 <__time64@plt+0x1fcfbc> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdbvs fp!, {r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 3e4f4 <__time64@plt+0x3cd3c> │ │ │ │ + blvc 3be508 <__time64@plt+0x3bcd50> │ │ │ │ + blvs 1fe748 <__time64@plt+0x1fcf90> │ │ │ │ + @ instruction: 0xed93693b │ │ │ │ + vldr d5, [r7] │ │ │ │ + vmul.f64 d7, d5, d12 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 3e4d4 <__time64@plt+0x3cd1c> │ │ │ │ + ldmdbvs fp!, {r4, r5, r6, sp, lr, pc}^ │ │ │ │ + blvc 13e51c <__time64@plt+0x13cd64> │ │ │ │ + blvc 11fe998 <__time64@plt+0x11fd1e0> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdbvs fp!, {r1, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + movwcs lr, #10707 @ 0x29d3 │ │ │ │ + stmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ + ldmdbvs fp!, {r2, r8, r9, sp}^ │ │ │ │ + blvc 3e538 <__time64@plt+0x3cd80> │ │ │ │ + blvc 11fe9b4 <__time64@plt+0x11fd1fc> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdbvs fp!, {r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + movwcs lr, #27091 @ 0x69d3 │ │ │ │ + stmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ + cdp 3, 11, cr2, cr7, cr0, {0} │ │ │ │ + vldr d6, [r7] │ │ │ │ + vadd.f64 d7, d6, d2 │ │ │ │ + vldr d7, [pc, #284] @ 302c <__time64@plt+0x1874> │ │ │ │ + vmul.f64 d6, d7, d27 │ │ │ │ + vmov.f64 d7, #6 @ 0x40300000 2.750 │ │ │ │ + @ instruction: 0xf7fe0b47 │ │ │ │ + vstr d14, [r7, #576] @ 0x240 │ │ │ │ + vldr d0, [r7, #56] @ 0x38 │ │ │ │ + vldr d7, [pc, #8] @ 2f30 <__time64@plt+0x1778> │ │ │ │ + vmul.f64 d6, d7, d21 │ │ │ │ + vmov.f64 d7, #6 @ 0x40300000 2.750 │ │ │ │ + @ instruction: 0xf7fe0b47 │ │ │ │ + vstr d14, [r7, #528] @ 0x210 │ │ │ │ + ldmdbvs fp!, {r2, r3, r8, r9, fp}^ │ │ │ │ + blvs be58c <__time64@plt+0xbcdd4> │ │ │ │ + blvc 3be5a0 <__time64@plt+0x3bcde8> │ │ │ │ + blvs 1fe7e0 <__time64@plt+0x1fd028> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d5, [r7, #8] │ │ │ │ + vmul.f64 d7, d5, d12 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc be56c <__time64@plt+0xbcdb4> │ │ │ │ + @ instruction: 0xed93697b │ │ │ │ + vldr d6, [r7, #16] │ │ │ │ + vmul.f64 d7, d6, d14 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ + blpl 13e5c0 <__time64@plt+0x13ce08> │ │ │ │ + blvc 33e5d4 <__time64@plt+0x33ce1c> │ │ │ │ + blvc 1fe810 <__time64@plt+0x1fd058> │ │ │ │ + blvc 1fe858 <__time64@plt+0x1fd0a0> │ │ │ │ + stc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + ldmdbvs fp!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvs 1be5d8 <__time64@plt+0x1bce20> │ │ │ │ + blvc 3be5ec <__time64@plt+0x3bce34> │ │ │ │ + blvs 1fe82c <__time64@plt+0x1fd074> │ │ │ │ + ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ + vldr d5, [r7, #24] │ │ │ │ + vmul.f64 d7, d5, d12 │ │ │ │ + vadd.f64 d7, d6, d7 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 1be5b8 <__time64@plt+0x1bce00> │ │ │ │ + strbcc fp, [r0, -r0, lsl #30] │ │ │ │ + stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ adcsge lr, r5, sp, lsl #27 │ │ │ │ mrccc 6, 5, ip, cr0, cr7, {7} │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ svccc 0x00f921fb │ │ │ │ - mvnsmi lr, sp, lsr #18 │ │ │ │ - stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ - @ instruction: 0x0c0cebad │ │ │ │ - svceq 0x00c8f8cc │ │ │ │ - blvc 13de50 <__time64@plt+0x13c5d4> │ │ │ │ - ldc 6, cr4, [r1, #52] @ 0x34 │ │ │ │ - ldrmi r3, [r0], r4, lsl #22 │ │ │ │ - blmi bde5c <__time64@plt+0xbc5e0> │ │ │ │ - ldc 6, cr4, [r1, #284] @ 0x11c │ │ │ │ - addlt r5, r8, r2, lsl #22 │ │ │ │ - blvc fe0c4 <__time64@plt+0xfc848> │ │ │ │ - blvs 1bde6c <__time64@plt+0x1bc5f0> │ │ │ │ - blcs 1bde74 <__time64@plt+0x1bc5f8> │ │ │ │ - cdp 6, 0, cr4, cr4, cr6, {0} │ │ │ │ - vldr d7, [r0, #20] │ │ │ │ - vldr d3, [r1] │ │ │ │ - strbtmi r5, [ip], -r0, lsl #22 │ │ │ │ - strtmi r4, [r2], -ip, lsr #18 │ │ │ │ - andcc r4, r8, ip, lsr #22 │ │ │ │ - blvc be064 <__time64@plt+0xbc7e8> │ │ │ │ - stmiapl fp, {r0, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - tstpeq r8, r5, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - movwls r6, #30747 @ 0x781b │ │ │ │ - movweq pc, #79 @ 0x4f @ │ │ │ │ - blvc 17e0ac <__time64@plt+0x17c830> │ │ │ │ - blvc bdb00 <__time64@plt+0xbc284> │ │ │ │ - @ instruction: 0xf900f7ff │ │ │ │ - blvc 3dec0 <__time64@plt+0x3c644> │ │ │ │ - blcs bdec8 <__time64@plt+0xbc64c> │ │ │ │ - ldc 6, cr4, [r6, #656] @ 0x290 │ │ │ │ - vldr d4, [r6, #16] │ │ │ │ - vldr d3, [r5] │ │ │ │ - vmul.f64 d6, d7, d2 │ │ │ │ - vldr d2, [r5, #8] │ │ │ │ - vmul.f64 d5, d7, d4 │ │ │ │ - vldr d4, [r6, #16] │ │ │ │ - vmla.f64 d1, d3, d6 │ │ │ │ - vldr d2, [r5, #24] │ │ │ │ - vmla.f64 d0, d3, d6 │ │ │ │ - vldr d4, [sp, #20] │ │ │ │ - vldr d6, [sp, #8] │ │ │ │ - vmul.f64 d5, d7, d0 │ │ │ │ - vmla.f64 d7, d3, d1 │ │ │ │ - vldr d7, [sp] │ │ │ │ - vadd.f64 d3, d5, d4 │ │ │ │ - vadd.f64 d5, d6, d2 │ │ │ │ - vadd.f64 d6, d3, d4 │ │ │ │ - vstr d3, [sp, #28] │ │ │ │ - vstr d5, [sp] │ │ │ │ - ldm ip!, {r1, r8, r9, fp, sp, lr} │ │ │ │ - strgt r0, [pc, -pc] │ │ │ │ - blmi 2d50fc <__time64@plt+0x2d3880> │ │ │ │ - stc 4, cr4, [sp, #488] @ 0x1e8 │ │ │ │ - ldm ip, {r2, r8, r9, fp, ip, sp} │ │ │ │ - stm r7, {r0, r1} │ │ │ │ - ldmpl r3, {r0, r1}^ │ │ │ │ - blls 1dc948 <__time64@plt+0x1db0cc> │ │ │ │ - @ instruction: 0xf04f405a │ │ │ │ - mrsle r0, SP_svc │ │ │ │ - andlt r4, r8, r0, asr #12 │ │ │ │ - ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ - mrc 7, 4, APSR_nzcv, cr10, cr14, {7} │ │ │ │ - @ instruction: 0x0000a7b4 │ │ │ │ - andeq r0, r0, ip, lsl r1 │ │ │ │ - andeq sl, r0, r4, lsr r7 │ │ │ │ - strmi r4, [r8], -r3, lsl #12 │ │ │ │ - blpl bdf54 <__time64@plt+0xbc6d8> │ │ │ │ - blvs 13df58 <__time64@plt+0x13c6dc> │ │ │ │ - blvc 1bdf5c <__time64@plt+0x1bc6e0> │ │ │ │ - blpl 117e3d8 <__time64@plt+0x117cb5c> │ │ │ │ - blvs 11be3dc <__time64@plt+0x11bcb60> │ │ │ │ - blvc 11fe3e0 <__time64@plt+0x11fcb64> │ │ │ │ + stc 5, cr11, [sp, #-704]! @ 0xfffffd40 │ │ │ │ + addlt r8, sl, r2, lsl #22 │ │ │ │ + rscsvs sl, r8, r0, lsl #30 │ │ │ │ + ldrhtvs r6, [sl], #-9 │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, sp, lr} │ │ │ │ + blvc 3e62c <__time64@plt+0x3ce74> │ │ │ │ + blhi 1fe87c <__time64@plt+0x1fd0c4> │ │ │ │ + @ instruction: 0xf10368fb │ │ │ │ + ldmvs fp!, {r3, r9} │ │ │ │ + ldrmi r3, [r9], -r8, lsl #6 │ │ │ │ + @ instruction: 0xf7fe4610 │ │ │ │ + mrc 13, 5, APSR_nzcv, cr0, cr6, {1} │ │ │ │ + vsub.f64 d7, d8, d0 │ │ │ │ + ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 3e610 <__time64@plt+0x3ce58> │ │ │ │ + @ instruction: 0xf10368fb │ │ │ │ + ldmvs fp!, {r3} │ │ │ │ + @ instruction: 0xf1073308 │ │ │ │ + @ instruction: 0x46190210 │ │ │ │ + stc2l 7, cr15, [sp, #-1016] @ 0xfffffc08 │ │ │ │ + blvs 13e678 <__time64@plt+0x13cec0> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, ip, lr} │ │ │ │ + blvc be674 <__time64@plt+0xbcebc> │ │ │ │ + blpl 1fe8c0 <__time64@plt+0x1fd108> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, lr}^ │ │ │ │ + blvc be684 <__time64@plt+0xbcecc> │ │ │ │ + blvc 1fe8cc <__time64@plt+0x1fd114> │ │ │ │ + blvc 1fe914 <__time64@plt+0x1fd15c> │ │ │ │ + blvc 1fe91c <__time64@plt+0x1fd164> │ │ │ │ + blvc 13e664 <__time64@plt+0x13ceac> │ │ │ │ + blvs 1be6a8 <__time64@plt+0x1bcef0> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, ip, lr} │ │ │ │ + blvc 13e6a4 <__time64@plt+0x13ceec> │ │ │ │ + blpl 1fe8f0 <__time64@plt+0x1fd138> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, lr}^ │ │ │ │ + blvc 13e6b4 <__time64@plt+0x13cefc> │ │ │ │ + blvc 1fe8fc <__time64@plt+0x1fd144> │ │ │ │ + blvc 1fe944 <__time64@plt+0x1fd18c> │ │ │ │ + blvc 1fe94c <__time64@plt+0x1fd194> │ │ │ │ + blvc 1be694 <__time64@plt+0x1bcedc> │ │ │ │ + blvs 23e6d8 <__time64@plt+0x23cf20> │ │ │ │ + ldc 8, cr6, [r3, #1004] @ 0x3ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, ip, lr} │ │ │ │ + blvc 1be6d4 <__time64@plt+0x1bcf1c> │ │ │ │ + blpl 1fe920 <__time64@plt+0x1fd168> │ │ │ │ + ldc 8, cr6, [r3, #748] @ 0x2ec │ │ │ │ + ldmvs fp!, {r8, r9, fp, lr}^ │ │ │ │ + blvc 1be6e4 <__time64@plt+0x1bcf2c> │ │ │ │ + blvc 1fe92c <__time64@plt+0x1fd174> │ │ │ │ + blvc 1fe974 <__time64@plt+0x1fd1bc> │ │ │ │ + blvc 1fe97c <__time64@plt+0x1fd1c4> │ │ │ │ + blvc 23e6c4 <__time64@plt+0x23cf0c> │ │ │ │ + @ instruction: 0xf103687b │ │ │ │ + @ instruction: 0xf1070408 │ │ │ │ + stcgt 5, cr0, [pc, #-64] @ 3074 <__time64@plt+0x18bc> │ │ │ │ + ldm r5, {r0, r1, r2, r3, sl, lr, pc} │ │ │ │ + stm r4, {r0, r1} │ │ │ │ + ldmdavs fp!, {r0, r1}^ │ │ │ │ + @ instruction: 0x37284618 │ │ │ │ + ldc 6, cr4, [sp], #756 @ 0x2f4 │ │ │ │ + @ instruction: 0xbdb08b02 │ │ │ │ + addlt fp, r3, r0, lsl #9 │ │ │ │ + rsbsvs sl, r8, r0, lsl #30 │ │ │ │ + ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ - movwcs lr, #2497 @ 0x9c1 │ │ │ │ - blpl bdf2c <__time64@plt+0xbc6b0> │ │ │ │ - blvs 13df30 <__time64@plt+0x13c6b4> │ │ │ │ - blvc 1bdf34 <__time64@plt+0x1bc6b8> │ │ │ │ - svclt 0x00004770 │ │ │ │ + stmib r1, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ + ldmdavs fp!, {r8, r9, sp}^ │ │ │ │ + blvc be734 <__time64@plt+0xbcf7c> │ │ │ │ + blvc 11febb0 <__time64@plt+0x11fd3f8> │ │ │ │ + stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ + ldmdavs fp!, {r1, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 13e744 <__time64@plt+0x13cf8c> │ │ │ │ + blvc 11febc0 <__time64@plt+0x11fd408> │ │ │ │ + stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ + ldmdavs fp!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ + blvc 1be754 <__time64@plt+0x1bcf9c> │ │ │ │ + blvc 11febd0 <__time64@plt+0x11fd418> │ │ │ │ + stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ + ldmdavs fp!, {r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ + smladcc ip, r8, r6, r4 │ │ │ │ + @ instruction: 0xf85d46bd │ │ │ │ + ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldrbtmi r4, [fp], #-2820 @ 0xfffff4fc │ │ │ │ andsvs r6, sl, sl, ror r8 │ │ │ │ strcc fp, [ip, -r0, lsl #30] │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ - andeq sl, r0, r2, asr r8 │ │ │ │ + ldrdeq fp, [r0], -r6 │ │ │ │ ldrlt fp, [r0, #1036] @ 0x40c │ │ │ │ stcmi 2, cr15, [r4, #-692] @ 0xfffffd4c │ │ │ │ @ instruction: 0xf507af02 │ │ │ │ @ instruction: 0xf5a3737e │ │ │ │ andsvs r7, r8, sp, ror r3 │ │ │ │ cmnpvc lr, #29360128 @ p-variant is OBSOLETE @ 0x1c00000 │ │ │ │ cmnpvc lr, #683671552 @ p-variant is OBSOLETE @ 0x28c00000 │ │ │ │ @@ -1087,107 +1643,107 @@ │ │ │ │ vqshl.s8 q2, q14, │ │ │ │ @ instruction: 0xf8c7430c │ │ │ │ @ instruction: 0xf10733f4 │ │ │ │ @ instruction: 0xf8d7000c │ │ │ │ @ instruction: 0xf8d733f4 │ │ │ │ vshl.s8 d18, d8, d0 │ │ │ │ @ instruction: 0xf7fe31e7 │ │ │ │ - blmi 47e60c <__time64@plt+0x47cd90> │ │ │ │ + blmi 47dc98 <__time64@plt+0x47c4e0> │ │ │ │ ldmdavs fp, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ - blmi 3fe1f8 <__time64@plt+0x3fc97c> │ │ │ │ + blmi 3fd8b4 <__time64@plt+0x3fc0fc> │ │ │ │ ldmdavs r8, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ ldrbtmi r4, [fp], #-2830 @ 0xfffff4f2 │ │ │ │ @ instruction: 0xf5076819 │ │ │ │ @ instruction: 0xf5a3737e │ │ │ │ @ instruction: 0xf107737d │ │ │ │ andls r0, r1, #12, 4 @ 0xc0000000 │ │ │ │ rsbsvc pc, lr, #29360128 @ 0x1c00000 │ │ │ │ rsbsvc pc, lr, #679477248 @ 0x28800000 │ │ │ │ andls r6, r0, #1179648 @ 0x120000 │ │ │ │ @ instruction: 0x460a681b │ │ │ │ ldrbtmi r4, [r9], #-2310 @ 0xfffff6fa │ │ │ │ - mcr 7, 5, pc, cr4, cr14, {7} @ │ │ │ │ - svc 0x0038f7fe │ │ │ │ - andeq sl, r0, ip, lsl #13 │ │ │ │ - andeq r0, r0, ip, lsr #2 │ │ │ │ - andeq r0, r0, r4, lsr #2 │ │ │ │ - andeq sl, r0, sl, ror #15 │ │ │ │ - andeq r7, r0, sl, lsl #10 │ │ │ │ + b 13411b4 <__time64@plt+0x133f9fc> │ │ │ │ + b ff8411b8 <__time64@plt+0xff83fa00> │ │ │ │ + andeq sl, r0, r0, lsr #29 │ │ │ │ + andeq r0, r0, r0, lsr #2 │ │ │ │ + andeq r0, r0, r8, lsl r1 │ │ │ │ + andeq fp, r0, lr, rrx │ │ │ │ + andeq r7, r0, sl, lsl #9 │ │ │ │ ldrlt fp, [r0, #1039] @ 0x40f │ │ │ │ ldclvc 5, cr15, [sp, #-692]! @ 0xfffffd4c │ │ │ │ ldcmi 15, cr10, [r1], {-0} │ │ │ │ vqshl.s8 q2, q14, │ │ │ │ @ instruction: 0xf8c74304 │ │ │ │ ldcne 3, cr3, [r8, #-944]! @ 0xfffffc50 │ │ │ │ mvncc pc, #14090240 @ 0xd70000 │ │ │ │ strcs pc, [r0], #-2263 @ 0xfffff729 │ │ │ │ mvncc pc, r0, asr #4 │ │ │ │ - mrc 7, 6, APSR_nzcv, cr14, cr14, {7} │ │ │ │ + b fe1c11f4 <__time64@plt+0xfe1bfa3c> │ │ │ │ stmiapl r3!, {r1, r3, r8, r9, fp, lr}^ │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - ldcl 7, cr15, [r6, #1016] @ 0x3f8 │ │ │ │ + stmib sl, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiapl r3!, {r3, r8, r9, fp, lr}^ │ │ │ │ - blmi 21ca84 <__time64@plt+0x21b208> │ │ │ │ + blmi 21d270 <__time64@plt+0x21bab8> │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ stmdbmi r7, {r0, r1, r3, r4, r5, r8, sl, fp, ip} │ │ │ │ @ instruction: 0xf7fe4479 │ │ │ │ - andcs lr, r1, r4, ror lr │ │ │ │ - mrc 7, 2, APSR_nzcv, cr14, cr14, {7} │ │ │ │ - andeq sl, r0, ip, lsl #12 │ │ │ │ - andeq r0, r0, ip, lsr #2 │ │ │ │ - andeq r0, r0, r4, lsr #2 │ │ │ │ - andeq sl, r0, ip, ror #14 │ │ │ │ - andeq r7, r0, ip, asr #9 │ │ │ │ + andcs lr, r1, ip, lsl sl │ │ │ │ + b 1c121c <__time64@plt+0x1bfa64> │ │ │ │ + andeq sl, r0, r0, lsr #28 │ │ │ │ + andeq r0, r0, r0, lsr #2 │ │ │ │ + andeq r0, r0, r8, lsl r1 │ │ │ │ + strdeq sl, [r0], -r0 │ │ │ │ + andeq r7, r0, ip, asr #8 │ │ │ │ ldrlt fp, [r0, #1039]! @ 0x40f │ │ │ │ ldclvc 5, cr15, [lr, #-692]! @ 0xfffffd4c │ │ │ │ ldcmi 15, cr10, [r8], {2} │ │ │ │ @ instruction: 0xf7fe447c │ │ │ │ - strmi lr, [r3], -sl, ror #28 │ │ │ │ + @ instruction: 0x4603ea12 │ │ │ │ @ instruction: 0xf8c7681b │ │ │ │ vcgt.s8 , , q14 │ │ │ │ @ instruction: 0xf8c74304 │ │ │ │ ldrtmi r3, [r8], -r8, ror #7 │ │ │ │ mvncc pc, #14090240 @ 0xd70000 │ │ │ │ strcs pc, [r0], #-2263 @ 0xfffff729 │ │ │ │ mvncc pc, r0, asr #4 │ │ │ │ - mcr 7, 5, pc, cr6, cr14, {7} @ │ │ │ │ + b 13c1264 <__time64@plt+0x13bfaac> │ │ │ │ stmiapl r3!, {r1, r2, r3, r8, r9, fp, lr}^ │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - ldc 7, cr15, [lr, #1016] @ 0x3f8 │ │ │ │ + ldmdb r2, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiapl r3!, {r2, r3, r8, r9, fp, lr}^ │ │ │ │ - blmi 31cb04 <__time64@plt+0x31b288> │ │ │ │ + blmi 31d2f0 <__time64@plt+0x31bb38> │ │ │ │ ldmdavs sp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ mvneq pc, #14090240 @ 0xd70000 │ │ │ │ - mrc 7, 0, APSR_nzcv, cr2, cr14, {7} │ │ │ │ + ldmib sl!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrtmi r4, [fp], -r2, lsl #12 │ │ │ │ strtmi r9, [sl], -r0, lsl #4 │ │ │ │ ldrbtmi r4, [r9], #-2311 @ 0xfffff6f9 │ │ │ │ @ instruction: 0xf7fe4620 │ │ │ │ - andcs lr, r1, r4, lsr lr │ │ │ │ - mrc 7, 0, APSR_nzcv, cr14, cr14, {7} │ │ │ │ - andeq sl, r0, r8, lsr #11 │ │ │ │ - andeq r0, r0, ip, lsr #2 │ │ │ │ - andeq r0, r0, r4, lsr #2 │ │ │ │ - strdeq sl, [r0], -ip │ │ │ │ - andeq r7, r0, sl, asr r4 │ │ │ │ + ldrdcs lr, [r1], -ip │ │ │ │ + stmib r6, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + @ instruction: 0x0000adbc │ │ │ │ + andeq r0, r0, r0, lsr #2 │ │ │ │ + andeq r0, r0, r8, lsl r1 │ │ │ │ + andeq sl, r0, r0, lsl #31 │ │ │ │ + ldrdeq r7, [r0], -sl │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ - ble 20d6e0 <__time64@plt+0x20be64> │ │ │ │ + ble 20decc <__time64@plt+0x20c714> │ │ │ │ ldrbtmi r4, [fp], #-2859 @ 0xfffff4d5 │ │ │ │ stmdbmi fp!, {r0, r2, r6, r9, sp} │ │ │ │ stmdami fp!, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf7fe4478 │ │ │ │ - ldmdavs fp!, {r2, r3, r4, r5, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmdavs fp!, {r2, r5, r6, r9, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0x4618331c │ │ │ │ - ldcl 7, cr15, [lr, #1016] @ 0x3f8 │ │ │ │ + stmib r6, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ cmnvs fp, r3, lsl #12 │ │ │ │ - blcs 1d0f0 <__time64@plt+0x1b874> │ │ │ │ + blcs 1d8dc <__time64@plt+0x1c124> │ │ │ │ ldmdavs fp!, {r1, r2, r8, ip, lr, pc}^ │ │ │ │ ldrbtmi r4, [sl], #-2596 @ 0xfffff5dc │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xff20f7ff │ │ │ │ ldrbtmi r4, [fp], #-2850 @ 0xfffff4de │ │ │ │ ldmdbvs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ @@ -1198,193 +1754,193 @@ │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr} │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r8, sp, lr}^ │ │ │ │ cmpvs sl, sl, lsr r8 │ │ │ │ @ instruction: 0xf646697a │ │ │ │ @ instruction: 0xf6c303b1 │ │ │ │ @ instruction: 0x619323de │ │ │ │ ldrbtmi r4, [fp], #-2838 @ 0xfffff4ea │ │ │ │ - blcs 1cbbc <__time64@plt+0x1b340> │ │ │ │ - blmi 576b64 <__time64@plt+0x5752e8> │ │ │ │ + blcs 1d3a8 <__time64@plt+0x1bbf0> │ │ │ │ + blmi 577350 <__time64@plt+0x575b98> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ andsvs r6, sl, sl, ror r9 │ │ │ │ ldrbtmi r4, [fp], #-2835 @ 0xfffff4ed │ │ │ │ andsvs r6, sl, sl, ror r9 │ │ │ │ - blcs 1cd54 <__time64@plt+0x1b4d8> │ │ │ │ + blcs 1d540 <__time64@plt+0x1bd88> │ │ │ │ ldmdbvs fp!, {r2, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ andseq pc, ip, r3, lsl #2 │ │ │ │ @ instruction: 0xf5b3687b │ │ │ │ svclt 0x00a87f7a │ │ │ │ cmnpvc sl, #1325400064 @ p-variant is OBSOLETE @ 0x4f000000 │ │ │ │ tstcs r0, sl, lsl r6 │ │ │ │ - stcl 7, cr15, [r8, #1016]! @ 0x3f8 │ │ │ │ + ldmib r0, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ tstcc ip, #2015232 @ 0x1ec000 │ │ │ │ @ instruction: 0x37184618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - @ instruction: 0x000076be │ │ │ │ - andeq r7, r0, ip, lsr #8 │ │ │ │ - andeq r7, r0, r4, lsr r4 │ │ │ │ - andeq r7, r0, r2, lsr #8 │ │ │ │ - andeq sl, r0, r2, lsr pc │ │ │ │ - strdeq sl, [r0], -lr │ │ │ │ - strdeq sl, [r0], -r4 │ │ │ │ - andeq sl, r0, sl, ror #29 │ │ │ │ + andeq r7, r0, r6, asr #12 │ │ │ │ + andeq r7, r0, ip, lsr #7 │ │ │ │ + @ instruction: 0x000073bc │ │ │ │ + andeq r7, r0, sl, lsr #7 │ │ │ │ + @ instruction: 0x0000b7b6 │ │ │ │ + andeq fp, r0, r2, lsl #15 │ │ │ │ + andeq fp, r0, r8, ror r7 │ │ │ │ + andeq fp, r0, lr, ror #14 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blcc 71cda8 <__time64@plt+0x71b52c> │ │ │ │ + blcc 71d594 <__time64@plt+0x71bddc> │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ @ instruction: 0xf646699a │ │ │ │ @ instruction: 0xf6c303b1 │ │ │ │ addsmi r2, sl, #2013265923 @ 0x78000003 │ │ │ │ movwcs sp, #9 │ │ │ │ ldrbtmi r4, [sl], #-2566 @ 0xfffff5fa │ │ │ │ stmdami r6, {r0, r1, r2, r3, r4, r6, r8, sp} │ │ │ │ @ instruction: 0xf7ff4478 │ │ │ │ @ instruction: 0xf7fefebb │ │ │ │ - ldmvs fp!, {r1, r4, r5, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmvs fp!, {r1, r3, r4, r6, r7, r8, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r7, r0, sl, ror r3 │ │ │ │ - andeq r7, r0, ip, lsr r3 │ │ │ │ + andeq r7, r0, r2, lsl #6 │ │ │ │ + @ instruction: 0x000072bc │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r2, lsl #30 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ ldrsbtvs pc, [r8], #247 @ 0xf7 @ │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldrmi r9, [r3], -r0, lsl #6 │ │ │ │ ldrbtmi r4, [sl], #-2564 @ 0xfffff5fc │ │ │ │ stmdami r4, {r0, r3, r5, r6, r8, sp} │ │ │ │ @ instruction: 0xf7ff4478 │ │ │ │ @ instruction: 0xf7fefe9b │ │ │ │ - svclt 0x0000ee12 │ │ │ │ - andeq r7, r0, lr, ror r3 │ │ │ │ - strdeq r7, [r0], -ip │ │ │ │ + svclt 0x0000e9ba │ │ │ │ + andeq r7, r0, r6, lsl #6 │ │ │ │ + andeq r7, r0, ip, ror r2 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blcs 1ce24 <__time64@plt+0x1b5a8> │ │ │ │ + blcs 1d610 <__time64@plt+0x1be58> │ │ │ │ ldmdavs r8!, {r1, r2, r3, r6, ip, lr, pc}^ │ │ │ │ @ instruction: 0xffb8f7ff │ │ │ │ ldmvs fp!, {r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ - blcs 1d1b4 <__time64@plt+0x1b938> │ │ │ │ + blcs 1d9a0 <__time64@plt+0x1c1e8> │ │ │ │ ldmvs fp!, {r0, r3, ip, lr, pc}^ │ │ │ │ adcsvs r6, fp, fp, asr r9 │ │ │ │ - bmi 8dd040 <__time64@plt+0x8db7c4> │ │ │ │ + bmi 8dd82c <__time64@plt+0x8dc074> │ │ │ │ cmpvs sl, sl, ror r4 │ │ │ │ ldmdavs r8!, {r0, r1, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ ldmvs fp!, {r3, r4, r7, r8, r9, sl, lr}^ │ │ │ │ - blcs 1ced0 <__time64@plt+0x1b654> │ │ │ │ + blcs 1d6bc <__time64@plt+0x1bf04> │ │ │ │ ldmvs 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sp, lr}^ │ │ │ │ subsvs r6, sl, r2, asr r8 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ andle r2, r4, r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldmdavs r2, {r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ andscs r6, ip, #26 │ │ │ │ ldmvs r8!, {r8, sp}^ │ │ │ │ - stcl 7, cr15, [r2, #-1016] @ 0xfffffc08 │ │ │ │ + stmia sl!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7fe68f8 │ │ │ │ - and lr, r0, r6, lsl #25 │ │ │ │ + and lr, r0, sl, lsr r8 │ │ │ │ ldrcc fp, [r0, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @ instruction: 0xffffff9d │ │ │ │ - andeq sl, r0, r8, asr #27 │ │ │ │ - @ instruction: 0x0000adb8 │ │ │ │ - @ instruction: 0x0000adb2 │ │ │ │ - andeq sl, r0, r8, lsr #27 │ │ │ │ + andeq fp, r0, ip, asr #12 │ │ │ │ + andeq fp, r0, ip, lsr r6 │ │ │ │ + andeq fp, r0, r6, lsr r6 │ │ │ │ + andeq fp, r0, ip, lsr #12 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ tstle r7, r0, lsl #22 │ │ │ │ ldmdavs sl!, {r8, r9, sp} │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ mrc2 7, 6, pc, cr12, cr15, {7} │ │ │ │ subs r4, r9, r3, lsl #12 │ │ │ │ - blcs 1ce08 <__time64@plt+0x1b58c> │ │ │ │ - blmi b79540 <__time64@plt+0xb77cc4> │ │ │ │ + blcs 1d5f4 <__time64@plt+0x1be3c> │ │ │ │ + blmi b79d2c <__time64@plt+0xb78574> │ │ │ │ addscs r4, r0, #2063597568 @ 0x7b000000 │ │ │ │ ldrbtmi r4, [r9], #-2348 @ 0xfffff6d4 │ │ │ │ ldrbtmi r4, [r8], #-2092 @ 0xfffff7d4 │ │ │ │ - ldc 7, cr15, [ip, #1016] @ 0x3f8 │ │ │ │ + stmdb r4, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ cmnpvs r8, sp, lsr pc @ p-variant is OBSOLETE │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ andle r2, r7, r0, lsl #22 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ldrbtmi r4, [sl], #-2598 @ 0xfffff5da │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ mcr2 7, 0, pc, cr2, cr15, {7} @ │ │ │ │ andcs r6, r0, #2015232 @ 0x1ec000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, r8, sp, lr} │ │ │ │ @ instruction: 0x4619331c │ │ │ │ @ instruction: 0xf7fe6978 │ │ │ │ - teqvs r8, r6, ror ip │ │ │ │ - blcs 1d254 <__time64@plt+0x1b9d8> │ │ │ │ + teqvs r8, lr, lsl r8 │ │ │ │ + blcs 1da40 <__time64@plt+0x1c288> │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, ip, lr, pc} │ │ │ │ - bmi 74f9e0 <__time64@plt+0x74e164> │ │ │ │ + bmi 7501cc <__time64@plt+0x74ea14> │ │ │ │ ldmvs r9!, {r1, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf7ff68f8 │ │ │ │ ldmdbvs sl!, {r0, r2, r3, r5, r6, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ addsmi r6, sl, #2015232 @ 0x1ec000 │ │ │ │ - blmi 676de8 <__time64@plt+0x67556c> │ │ │ │ + blmi 6775d4 <__time64@plt+0x675e1c> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ addsmi r6, sl, #1998848 @ 0x1e8000 │ │ │ │ - blmi 5f719c <__time64@plt+0x5f5920> │ │ │ │ + blmi 5f7988 <__time64@plt+0x5f61d0> │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldmdbvs fp!, {r1, r3, r4, sp, lr} │ │ │ │ - blcs 1ce08 <__time64@plt+0x1b58c> │ │ │ │ + blcs 1d5f4 <__time64@plt+0x1be3c> │ │ │ │ ldmdbvs fp!, {r0, r1, ip, lr, pc} │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, sp, lr} │ │ │ │ - blcs 1cf18 <__time64@plt+0x1b69c> │ │ │ │ + blcs 1d704 <__time64@plt+0x1bf4c> │ │ │ │ ldmdbvs fp!, {r0, r1, ip, lr, pc} │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r6, fp, sp, lr} │ │ │ │ ldmdbvs sl!, {r1, r3, r4, sp, lr} │ │ │ │ @ instruction: 0x03b1f646 │ │ │ │ bicscs pc, lr, #204472320 @ 0xc300000 │ │ │ │ ldmdbvs fp!, {r0, r1, r4, r7, r8, sp, lr} │ │ │ │ addsvs r6, sl, sl, lsr r8 │ │ │ │ tstcc ip, #966656 @ 0xec000 │ │ │ │ @ instruction: 0x37184618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - muleq r0, r8, r4 │ │ │ │ - andeq r7, r0, lr, ror #3 │ │ │ │ - strdeq r7, [r0], -r6 │ │ │ │ - muleq r0, r6, r2 │ │ │ │ - @ instruction: 0x000072b0 │ │ │ │ - andeq sl, r0, r4, asr #25 │ │ │ │ - @ instruction: 0x0000acb8 │ │ │ │ + andeq r7, r0, r0, lsr #8 │ │ │ │ + andeq r7, r0, lr, ror #2 │ │ │ │ + andeq r7, r0, lr, ror r1 │ │ │ │ + andeq r7, r0, lr, lsl r2 │ │ │ │ + andeq r7, r0, r8, lsr r2 │ │ │ │ + andeq fp, r0, r8, asr #10 │ │ │ │ + andeq fp, r0, ip, lsr r5 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ - blcs 1d0ec <__time64@plt+0x1b870> │ │ │ │ - blmi 539e24 <__time64@plt+0x5385a8> │ │ │ │ + blcs 1d8d8 <__time64@plt+0x1c120> │ │ │ │ + blmi 53a610 <__time64@plt+0x538e58> │ │ │ │ adccs r4, r9, #2063597568 @ 0x7b000000 │ │ │ │ ldrbtmi r4, [r9], #-2323 @ 0xfffff6ed │ │ │ │ ldrbtmi r4, [r8], #-2067 @ 0xfffff7ed │ │ │ │ - stc 7, cr15, [sl, #-1016]! @ 0xfffffc08 │ │ │ │ - blcc 5d104 <__time64@plt+0x5b888> │ │ │ │ + ldm r2, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blcc 5d8f0 <__time64@plt+0x5c138> │ │ │ │ ldrmi r6, [r3], #-2298 @ 0xfffff706 │ │ │ │ and r6, r9, fp, ror r1 │ │ │ │ ldmdavc sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x701a68fb │ │ │ │ movwcc r6, #6395 @ 0x18fb │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ rsbsvs r3, fp, r1, lsl #6 │ │ │ │ @@ -1392,33 +1948,33 @@ │ │ │ │ andle r4, r3, #-1610612727 @ 0xa0000009 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ andcs r6, r0, #16449536 @ 0xfb0000 │ │ │ │ svclt 0x0000701a │ │ │ │ ssatmi r3, #30, r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq r7, r0, ip, asr #7 │ │ │ │ - andeq r7, r0, sl, lsl #2 │ │ │ │ - andeq r7, r0, r6, lsr r2 │ │ │ │ + andeq r7, r0, r4, asr r3 │ │ │ │ + andeq r7, r0, sl, lsl #1 │ │ │ │ + @ instruction: 0x000071be │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - @ instruction: 0xf7fe6878 │ │ │ │ - @ instruction: 0x4603ec50 │ │ │ │ + @ instruction: 0xf7fd6878 │ │ │ │ + @ instruction: 0x4603eff8 │ │ │ │ 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│ │ @ instruction: 0x4618b2db │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 141058 <__time64@plt+0x13f7dc> │ │ │ │ + blvc 141844 <__time64@plt+0x14008c> │ │ │ │ ldrlt r4, [r0, #1904] @ 0x770 │ │ │ │ svcge 0x0000b083 │ │ │ │ eorsvs r6, r9, r8, ror r0 │ │ │ │ ldmdavs fp!, {r0, r2, sp, lr, pc} │ │ │ │ eorsvs r3, fp, r1, lsl #6 │ │ │ │ movwcc r6, #6267 @ 0x187b │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, sp, lr} │ │ │ │ - blcs 20f70 <__time64@plt+0x1f6f4> │ │ │ │ + blcs 2175c <__time64@plt+0x1ffa4> │ │ │ │ ldmdavs fp!, {r0, r2, r3, ip, lr, pc} │ │ │ │ @ instruction: 0x4618781b │ │ │ │ - mcrr 7, 15, pc, r6, cr14 @ │ │ │ │ + svc 0x00eef7fd │ │ │ │ ldmdavs fp!, {r2, r9, sl, lr}^ │ │ │ │ @ instruction: 0x4618781b │ │ │ │ - mcrr 7, 15, pc, r0, cr14 @ │ │ │ │ + svc 0x00e8f7fd │ │ │ │ addsmi r4, ip, #3145728 @ 0x300000 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r5, r6, r7, ip, lr, pc} │ │ │ │ - blcs 20f94 <__time64@plt+0x1f718> │ │ │ │ + blcs 21780 <__time64@plt+0x1ffc8> │ │ │ │ movwcs fp, #7948 @ 0x1f0c │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ ldclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - bl ff8c0f40 <__time64@plt+0xff8bf6c4> │ │ │ │ + svc 0x008af7fd │ │ │ │ rscsvs r4, fp, r3, lsl #12 │ │ │ │ - @ instruction: 0xf7fe6838 │ │ │ │ - @ instruction: 0x4603ebde │ │ │ │ + @ instruction: 0xf7fd6838 │ │ │ │ + strmi lr, [r3], -r6, lsl #31 │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r7, sp, lr}^ │ │ │ │ addsmi r6, sl, #12255232 @ 0xbb0000 │ │ │ │ movwcs sp, #2561 @ 0xa01 │ │ │ │ ldmvs sl!, {r0, r3, r4, sp, lr, pc}^ │ │ │ │ - bne ff4dd254 <__time64@plt+0xff4db9d8> │ │ │ │ + bne ff4dda40 <__time64@plt+0xff4dc288> │ │ │ │ ldrmi r6, [r3], #-2170 @ 0xfffff786 │ │ │ │ and r6, sp, fp, ror r0 │ │ │ │ ldmdavc sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ mulle r1, sl, r2 │ │ │ │ and r2, sl, r0, lsl #6 │ │ │ │ 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│ mrrcmi 15, 0, sl, lr, cr2 │ │ │ │ @ instruction: 0xf7ff447c │ │ │ │ - blmi 1783194 <__time64@plt+0x1781918> │ │ │ │ + blmi 1783980 <__time64@plt+0x17821c8> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ adc r2, sp, r0, lsl #6 │ │ │ │ stmiapl r3!, {r1, r3, r4, r6, r8, r9, fp, lr}^ │ │ │ │ - blmi 169d2b4 <__time64@plt+0x169ba38> │ │ │ │ + blmi 169daa0 <__time64@plt+0x169c2e8> │ │ │ │ ldmdavs sl, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ ldmdbmi r9, {r2, r5, r6, r8, r9, sp}^ │ │ │ │ - @ instruction: 0xf7fe4479 │ │ │ │ - blmi 163dbd4 <__time64@plt+0x163c358> │ │ │ │ + @ instruction: 0xf7fd4479 │ │ │ │ + blmi 163f260 <__time64@plt+0x163daa8> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ movwcs r6, #507 @ 0x1fb │ │ │ │ - blmi 149b95c <__time64@plt+0x149a0e0> │ │ │ │ + blmi 149c148 <__time64@plt+0x149a990> │ │ │ │ ldmdavs fp, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ tstcs r1, r4, lsr r2 │ │ │ │ ldrbtmi r4, [r8], #-2131 @ 0xfffff7ad │ │ │ │ - ldmib r2!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldc 7, cr15, [sl, #1012] @ 0x3f4 │ │ │ │ stmiapl r3!, {r0, r2, r3, r6, r8, r9, fp, lr}^ │ │ │ │ eorscs r6, r9, #1769472 @ 0x1b0000 │ │ │ │ ldmdami r0, {r0, r8, sp}^ │ │ │ │ - @ instruction: 0xf7fe4478 │ │ │ │ - rsb lr, r2, sl, ror #19 │ │ │ │ + @ instruction: 0xf7fd4478 │ │ │ │ + mls r2, r2, sp, lr │ │ │ │ movwcc r6, #6587 @ 0x19bb │ │ │ │ - blmi 11db988 <__time64@plt+0x11da10c> │ │ │ │ + blmi 11dc174 <__time64@plt+0x11da9bc> │ │ │ │ ldmdavs r8, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ ldmibvs sl, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr} │ │ │ │ @ instruction: 0x03b1f646 │ │ │ │ bicscs pc, lr, #204472320 @ 0xc300000 │ │ │ │ @ instruction: 0xd103429a │ │ │ │ ldrbtmi r4, [fp], #-2887 @ 0xfffff4b9 │ │ │ │ and r4, r2, sl, lsl r6 │ │ │ │ ldrbtmi r4, [fp], #-2886 @ 0xfffff4ba │ │ │ │ ldmibvs fp!, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ movwls r6, #2203 @ 0x89b │ │ │ │ ldmibvs sl!, {r0, r1, r4, r9, sl, lr} │ │ │ │ ldrbtmi r4, [r9], #-2371 @ 0xfffff6bd │ │ │ │ - b 9412c8 <__time64@plt+0x93fa4c> │ │ │ │ + stcl 7, cr15, [ip, #1012] @ 0x3f4 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr} │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r8, sp, lr} │ │ │ │ vstrle d2, [r1, #-80] @ 0xffffffb0 │ │ │ │ teqvs fp, r4, lsl r3 │ │ │ │ tstcc ip, #4112384 @ 0x3ec000 │ │ │ │ movwcs r6, #59 @ 0x3b │ │ │ │ ands r6, r6, fp, ror r1 │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr} │ │ │ │ ldmdavc fp, {r0, r1, r4, sl, lr} │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ vstrle d2, [r2, #-124] @ 0xffffff84 │ │ │ │ - blcs 1f9d6ec <__time64@plt+0x1f9be70> │ │ │ │ + blcs 1f9ded8 <__time64@plt+0x1f9c720> │ │ │ │ @ instruction: 0x232edd01 │ │ │ │ - blmi b1b6f4 <__time64@plt+0xb19e78> │ │ │ │ + blmi b1bee0 <__time64@plt+0xb1a728> │ │ │ │ ldmdavs fp, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ ldmvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - b 144130c <__time64@plt+0x143fa90> │ │ │ │ + ldcl 7, cr15, [r8, #1012]! @ 0x3f4 │ │ │ │ movwcc r6, #6523 @ 0x197b │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ addsmi r6, sl, #966656 @ 0xec000 │ │ │ │ and sp, r9, r4, ror #23 │ │ │ │ stmiapl r3!, {r2, r5, r8, r9, fp, lr}^ │ │ │ │ @ instruction: 0x4619681b │ │ │ │ - @ instruction: 0xf7fe2020 │ │ │ │ - ldmdbvs fp!, {r1, r6, r9, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7fd2020 │ │ │ │ + ldmdbvs fp!, {r1, r3, r5, r6, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ cmnvs fp, r1, lsl #6 │ │ │ │ - blcs 51d928 <__time64@plt+0x51c0ac> │ │ │ │ - blmi 7bab08 <__time64@plt+0x7b928c> │ │ │ │ + blcs 51e114 <__time64@plt+0x51c95c> │ │ │ │ + blmi 7bb2f4 <__time64@plt+0x7b9b3c> │ │ │ │ ldmdavs r8, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr} │ │ │ │ ldrbtmi r4, [r9], #-2339 @ 0xfffff6dd │ │ │ │ - stmib r2!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stc 7, cr15, [sl, #1012] @ 0x3f4 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ ldmibvs fp!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ andle r2, r2, r0, lsl #22 │ │ │ │ - blcs 18dda50 <__time64@plt+0x18dc1d4> │ │ │ │ + blcs 18de23c <__time64@plt+0x18dca84> │ │ │ │ movwcs sp, #3478 @ 0xd96 │ │ │ │ movwcs r6, #187 @ 0xbb │ │ │ │ - blmi 71b55c <__time64@plt+0x719ce0> │ │ │ │ + blmi 71bd48 <__time64@plt+0x71a590> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ strd r6, [sl], -fp │ │ │ │ movwcc r6, #6331 @ 0x18bb │ │ │ │ ldmibvs fp!, {r0, r1, r3, r4, r5, r7, sp, lr}^ │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r7, fp, sp, lr}^ │ │ │ │ rsbsvs r4, fp, r3, lsl r4 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ ldmibvs fp!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ mvnsle r2, r0, lsl #22 │ │ │ │ stmiapl r3!, {r3, r8, r9, fp, lr}^ │ │ │ │ ldmdavs fp!, {r3, r4, fp, sp, lr}^ │ │ │ │ ldmdbmi r1, {r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ - @ instruction: 0xf7fe4479 │ │ │ │ - movwcs lr, #6586 @ 0x19ba │ │ │ │ + @ instruction: 0xf7fd4479 │ │ │ │ + movwcs lr, #7522 @ 0x1d62 │ │ │ │ @ instruction: 0x37244618 │ │ │ │ ldclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r9, r0, r8, asr #27 │ │ │ │ - andeq sl, r0, r8, lsl #16 │ │ │ │ + ldrdeq sl, [r0], -ip │ │ │ │ + andeq fp, r0, ip, lsl #1 │ │ │ │ + andeq r0, r0, r8, lsl r1 │ │ │ │ andeq r0, r0, r4, lsr #2 │ │ │ │ - andeq r0, r0, r0, lsr r1 │ │ │ │ - andeq r6, r0, r4, asr lr │ │ │ │ - andeq sl, r0, r4, ror #15 │ │ │ │ - andeq r6, r0, lr, ror #28 │ │ │ │ - muleq r0, r4, lr │ │ │ │ - andeq r6, r0, sl, lsr #29 │ │ │ │ - andeq r6, r0, r6, lsr #29 │ │ │ │ - muleq r0, sl, lr │ │ │ │ - andeq r6, r0, r6, lsr #28 │ │ │ │ - ldrdeq sl, [r0], -r8 │ │ │ │ ldrdeq r6, [r0], -ip │ │ │ │ + andeq fp, r0, r8, rrx │ │ │ │ + strdeq r6, [r0], -r6 @ │ │ │ │ + andeq r6, r0, ip, lsl lr │ │ │ │ + andeq r6, r0, r2, lsr lr │ │ │ │ + andeq r6, r0, lr, lsr #28 │ │ │ │ + andeq r6, r0, r2, lsr #28 │ │ │ │ + andeq r6, r0, lr, lsr #27 │ │ │ │ + andeq sl, r0, ip, asr pc │ │ │ │ + andeq r6, r0, r4, ror #26 │ │ │ │ addlt fp, r5, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ rscsvs r2, fp, r0, lsl #6 │ │ │ │ - blmi 43b43c <__time64@plt+0x439bc0> │ │ │ │ + blmi 43bc28 <__time64@plt+0x43a470> │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ eorscc pc, r2, r3, asr r8 @ │ │ │ │ addsmi r6, sl, #7995392 @ 0x7a0000 │ │ │ │ - bmi 377820 <__time64@plt+0x375fa4> │ │ │ │ + bmi 37800c <__time64@plt+0x376854> │ │ │ │ ldmvs fp!, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ and r6, sl, fp, asr r8 │ │ │ │ movwcc r6, #6395 @ 0x18fb │ │ │ │ - blmi 25b808 <__time64@plt+0x259f8c> │ │ │ │ + blmi 25bff4 <__time64@plt+0x25a83c> │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ eorscc pc, r2, r3, asr r8 @ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ ssatmi r3, #30, r4, lsl #14 │ │ │ │ - blvc 1415a8 <__time64@plt+0x13fd2c> │ │ │ │ + blvc 141d94 <__time64@plt+0x1405dc> │ │ │ │ svclt 0x00004770 │ │ │ │ - muleq r0, ip, sp │ │ │ │ - andeq r9, r0, ip, lsl #27 │ │ │ │ - andeq r9, r0, r8, ror sp │ │ │ │ + andeq sl, r0, r0, lsr #12 │ │ │ │ + andeq sl, r0, r0, lsl r6 │ │ │ │ + strdeq sl, [r0], -ip │ │ │ │ + andeq r0, r0, r0 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blcs 1d63c <__time64@plt+0x1bdc0> │ │ │ │ + blcs 1de2c <__time64@plt+0x1c674> │ │ │ │ @ instruction: 0xf04fd102 │ │ │ │ strd r3, [sp], -pc @ │ │ │ │ ldrbtmi r4, [fp], #-2840 @ 0xfffff4e8 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - ldm r4, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blcs 14c74 <__time64@plt+0x133f8> │ │ │ │ + mcrr 7, 15, pc, r6, cr13 @ │ │ │ │ + blcs 15464 <__time64@plt+0x13cac> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ - blmi 53b4f8 <__time64@plt+0x539c7c> │ │ │ │ + blmi 53bce8 <__time64@plt+0x53a530> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ - @ instruction: 0xf7fe6878 │ │ │ │ - strmi lr, [r3], -sl, lsl #17 │ │ │ │ + @ instruction: 0xf7fd6878 │ │ │ │ + @ instruction: 0x4603ec3c │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, r7, r1, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2831 @ 0xfffff4f1 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - ldmda lr!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - blcs 14ca0 <__time64@plt+0x13424> │ │ │ │ + ldc 7, cr15, [r0], #-1012 @ 0xfffffc0c │ │ │ │ + blcs 15490 <__time64@plt+0x13cd8> │ │ │ │ movwcs sp, #8449 @ 0x2101 │ │ │ │ - blmi 2fb4cc <__time64@plt+0x2f9c50> │ │ │ │ + blmi 2fbcbc <__time64@plt+0x2fa504> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ - @ instruction: 0xf7fe6878 │ │ │ │ - @ instruction: 0x4603e874 │ │ │ │ + @ instruction: 0xf7fd6878 │ │ │ │ + strmi lr, [r3], -r6, lsr #24 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, r1, r3, lsl #6 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r8, r0, lr, asr #4 │ │ │ │ - andeq r8, r0, r0, asr #4 │ │ │ │ - andeq r8, r0, r6, lsr r2 │ │ │ │ - andeq r8, r0, ip, lsr #4 │ │ │ │ + ldrdeq r8, [r0], -r2 │ │ │ │ + andeq r8, r0, r4, asr #3 │ │ │ │ + @ instruction: 0x000081ba │ │ │ │ + @ instruction: 0x000081b0 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blcs dd6c4 <__time64@plt+0xdbe48> │ │ │ │ + blcs ddeb4 <__time64@plt+0xdc6fc> │ │ │ │ andge sp, r2, #24, 16 @ 0x180000 │ │ │ │ eorcc pc, r3, r2, asr r8 @ │ │ │ │ @ instruction: 0x4710441a │ │ │ │ andeq r0, r0, r1, lsl r0 │ │ │ │ andeq r0, r0, r7, lsl r0 │ │ │ │ andeq r0, r0, sp, lsl r0 │ │ │ │ andeq r0, r0, r3, lsr #32 │ │ │ │ ldrbtmi r4, [fp], #-2828 @ 0xfffff4f4 │ │ │ │ - blmi 33b544 <__time64@plt+0x339cc8> │ │ │ │ + blmi 33bd34 <__time64@plt+0x33a57c> │ │ │ │ and r4, pc, fp, ror r4 @ │ │ │ │ ldrbtmi r4, [fp], #-2827 @ 0xfffff4f5 │ │ │ │ - blmi 2fb538 <__time64@plt+0x2f9cbc> │ │ │ │ + blmi 2fbd28 <__time64@plt+0x2fa570> │ │ │ │ and r4, r9, fp, ror r4 │ │ │ │ - bmi 29d6fc <__time64@plt+0x29be80> │ │ │ │ + bmi 29deec <__time64@plt+0x29c734> │ │ │ │ orrcs r4, r9, sl, ror r4 │ │ │ │ ldrbtmi r4, [r8], #-2057 @ 0xfffff7f7 │ │ │ │ - blx 741518 <__time64@plt+0x73fc9c> │ │ │ │ - ldmib r2, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blx 6c1d08 <__time64@plt+0x6c0550> │ │ │ │ + ldc 7, cr15, [r8, #-1012]! @ 0xfffffc0c │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - @ instruction: 0x000081b2 │ │ │ │ - @ instruction: 0x000081b4 │ │ │ │ - @ instruction: 0x000081ba │ │ │ │ - andeq r8, r0, r0, asr #3 │ │ │ │ - andeq r8, r0, r0, asr #3 │ │ │ │ - andeq r8, r0, lr, asr #3 │ │ │ │ + andeq r8, r0, r6, lsr r1 │ │ │ │ + andeq r8, r0, r8, lsr r1 │ │ │ │ + andeq r8, r0, lr, lsr r1 │ │ │ │ + andeq r8, r0, r4, asr #2 │ │ │ │ + andeq r8, r0, r4, asr #2 │ │ │ │ + andeq r8, r0, r2, asr r1 │ │ │ │ addlt fp, r5, r0, lsl #9 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ andle r2, r5, r0, lsl #22 │ │ │ │ ldmdavc sl, {r0, r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ @@ -1876,70 +2433,70 @@ │ │ │ │ andle r2, r5, r0, lsl #22 │ │ │ │ ldmibvc sl, {r0, r1, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ ldmibvc fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xd101429a │ │ │ │ and r2, r0, r1, lsl #6 │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ ssatmi r3, #30, r4, lsl #14 │ │ │ │ - blvc 14175c <__time64@plt+0x13fee0> │ │ │ │ + blvc 141f4c <__time64@plt+0x140794> │ │ │ │ ldrlt r4, [r0, #1904]! @ 0x770 │ │ │ │ svcge 0x0000b086 │ │ │ │ ldrshtvs r6, [r9], r8 │ │ │ │ ldmvs fp!, {r1, r3, r4, r5, r6, sp, lr}^ │ │ │ │ movwcc r7, #7387 @ 0x1cdb │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r8, sp, lr}^ │ │ │ │ - blcs 22970 <__time64@plt+0x210f4> │ │ │ │ + blcs 23160 <__time64@plt+0x219a8> │ │ │ │ movwcs sp, #267 @ 0x10b │ │ │ │ @ instruction: 0x21bf2218 │ │ │ │ ldrbtmi r4, [r8], #-2080 @ 0xfffff7e0 │ │ │ │ - blx 1741610 <__time64@plt+0x173fd94> │ │ │ │ + blx 16c1e00 <__time64@plt+0x16c0648> │ │ │ │ ldmvs fp!, {r1, r9, sl, lr}^ │ │ │ │ addscs pc, r0, r3, asr #17 │ │ │ │ ldmvs fp!, {r0, r1, r2, r3, sp, lr, pc}^ │ │ │ │ @ instruction: 0x2090f8d3 │ │ │ │ tstcs r8, fp, ror r9 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ ldmdami r9, {r0, r1, r6, r7, r8, sp} │ │ │ │ @ instruction: 0xf7ff4478 │ │ │ │ - @ instruction: 0x4602fb5f │ │ │ │ + @ instruction: 0x4602fb5d │ │ │ │ @ instruction: 0xf8c368fb │ │ │ │ ldmvs fp!, {r4, r7, sp}^ │ │ │ │ @ instruction: 0x3090f8d3 │ │ │ │ tstle r4, r0, lsl #22 │ │ │ │ andcs r6, r0, #16449536 @ 0xfb0000 │ │ │ │ movwcs r7, #9434 @ 0x24da │ │ │ │ ldmvs fp!, {r1, r3, r4, sp, lr, pc}^ │ │ │ │ @ instruction: 0x2090f8d3 │ │ │ │ ldclvc 8, cr6, [fp], {251} @ 0xfb │ │ │ │ tstcs r8, #26214400 @ 0x1900000 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ ldmvs fp!, {r1, r3, r4, sl, lr} │ │ │ │ @ instruction: 0x461d4614 │ │ │ │ - strgt ip, [pc], #-3343 @ 3670 <__time64@plt+0x1df4> │ │ │ │ + strgt ip, [pc], #-3343 @ 3e60 <__time64@plt+0x26a8> │ │ │ │ muleq r3, r5, r8 │ │ │ │ andeq lr, r3, r4, lsl #17 │ │ │ │ sbcslt r6, sl, #2015232 @ 0x1ec000 │ │ │ │ ldrbvc r6, [sl], #2299 @ 0x8fb │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ movwcs r6, #26 │ │ │ │ @ instruction: 0x37184618 │ │ │ │ ldclt 6, cr4, [r0, #756]! @ 0x2f4 │ │ │ │ - ldrdeq r8, [r0], -r6 │ │ │ │ - strheq r8, [r0], -r4 │ │ │ │ + andeq r8, r0, sl, asr r0 │ │ │ │ + andeq r8, r0, r8, lsr r0 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ svclt 0x00142b00 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ ldrsbtvs fp, [fp], #43 @ 0x2b │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ andeq pc, ip, #-1073741823 @ 0xc0000001 │ │ │ │ msrmi R9_usr, r5 │ │ │ │ - @ instruction: 0xf7fe4618 │ │ │ │ - @ instruction: 0x4603e8bc │ │ │ │ + @ instruction: 0xf7fd4618 │ │ │ │ + strmi lr, [r3], -r2, ror #24 │ │ │ │ andle r2, r2, r0, lsl #22 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ movwcs lr, #0 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @ instruction: 0xf5adb590 │ │ │ │ addlt r5, r5, r2, lsl #26 │ │ │ │ @@ -1958,171 +2515,171 @@ │ │ │ │ movwcs r4, #5658 @ 0x161a │ │ │ │ stccc 8, cr15, [ip], #-264 @ 0xfffffef8 │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ stccc 8, cr15, [r0], {83} @ 0x53 │ │ │ │ andle r2, ip, r0, lsl #22 │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ stccc 8, cr15, [r0], {83} @ 0x53 │ │ │ │ - blcs 2179c <__time64@plt+0x1ff20> │ │ │ │ + blcs 21f8c <__time64@plt+0x207d4> │ │ │ │ @ instruction: 0xf107d105 │ │ │ │ ldrmi r0, [sl], -r8, lsl #7 │ │ │ │ @ instruction: 0xf8422300 │ │ │ │ @ instruction: 0xf1073c80 │ │ │ │ @ instruction: 0xf8530388 │ │ │ │ - blcs 12958 <__time64@plt+0x110dc> │ │ │ │ + blcs 13148 <__time64@plt+0x11990> │ │ │ │ @ instruction: 0xf107db06 │ │ │ │ @ instruction: 0xf8530388 │ │ │ │ @ instruction: 0xf5b33c84 │ │ │ │ - blle 3d3558 <__time64@plt+0x3d1cdc> │ │ │ │ + blle 3d3d48 <__time64@plt+0x3d2590> │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ stccc 8, cr15, [r4], {83} @ 0x53 │ │ │ │ @ instruction: 0x27c0f8df │ │ │ │ vst3.16 {d20-d22}, [pc :256], sl │ │ │ │ @ instruction: 0xf8df7182 │ │ │ │ ldrbtmi r0, [r8], #-1980 @ 0xfffff844 │ │ │ │ - @ instruction: 0xf8f0f7ff │ │ │ │ - stmda r6!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf8eef7ff │ │ │ │ + stc 7, cr15, [ip], {253} @ 0xfd │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ ldclcc 8, cr15, [ip], #-332 @ 0xfffffeb4 │ │ │ │ svclt 0x000c2b00 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0xf507b2db │ │ │ │ @ instruction: 0xf1025201 │ │ │ │ andsvs r0, r3, r8, lsr r2 │ │ │ │ movwpl pc, #5383 @ 0x1507 @ │ │ │ │ teqpeq r8, #-1073741824 @ p-variant is OBSOLETE @ 0xc0000000 │ │ │ │ - blcs 1d80c <__time64@plt+0x1bf90> │ │ │ │ + blcs 1dffc <__time64@plt+0x1c844> │ │ │ │ @ instruction: 0xf107d007 │ │ │ │ @ instruction: 0xf8530388 │ │ │ │ - blcs 129ac <__time64@plt+0x11130> │ │ │ │ + blcs 1319c <__time64@plt+0x119e4> │ │ │ │ movwcs sp, #4353 @ 0x1101 │ │ │ │ movwcs lr, #0 │ │ │ │ andpl pc, r1, #29360128 @ 0x1c00000 │ │ │ │ eorseq pc, r4, #-2147483648 @ 0x80000000 │ │ │ │ andcs r6, r0, #19 │ │ │ │ andcs r2, r2, r2, lsl #2 │ │ │ │ - stmda ip!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bl ff4c1fac <__time64@plt+0xff4c07f4> │ │ │ │ movwpl pc, #5383 @ 0x1507 @ │ │ │ │ teqpeq r0, #-1073741824 @ p-variant is OBSOLETE @ 0xc0000000 │ │ │ │ @ instruction: 0xf5076018 │ │ │ │ @ instruction: 0xf1035301 │ │ │ │ ldmdavs fp, {r4, r5, r8, r9} │ │ │ │ svccc 0x00fff1b3 │ │ │ │ @ instruction: 0xf8dfd107 │ │ │ │ ldrbtmi r3, [fp], #-1864 @ 0xfffff8b8 │ │ │ │ @ instruction: 0xf7fd4618 │ │ │ │ - movwcs lr, #3894 @ 0xf36 │ │ │ │ + movwcs lr, #2780 @ 0xadc │ │ │ │ @ instruction: 0xf507e38f │ │ │ │ @ instruction: 0xf1035301 │ │ │ │ ldmdavs fp, {r3, r4, r5, r8, r9} │ │ │ │ rsbsle r2, r2, r0, lsl #22 │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ stccc 8, cr15, [r0], {83} @ 0x53 │ │ │ │ cmnle ip, r0, lsl #22 │ │ │ │ movwpl pc, #5383 @ 0x1507 @ │ │ │ │ teqpeq r4, #-1073741824 @ p-variant is OBSOLETE @ 0xc0000000 │ │ │ │ - blcs 1d884 <__time64@plt+0x1c008> │ │ │ │ + blcs 1e074 <__time64@plt+0x1c8bc> │ │ │ │ @ instruction: 0xf107d033 │ │ │ │ - blcc b04640 <__time64@plt+0xb02dc4> │ │ │ │ + blcc b04e30 <__time64@plt+0xb03678> │ │ │ │ andls r2, r0, #4, 4 @ 0x40000000 │ │ │ │ tstcs r1, r6, lsl #4 │ │ │ │ andpl pc, r1, r7, lsl #10 │ │ │ │ eorseq pc, r0, r0, lsl #2 │ │ │ │ @ instruction: 0xf7fd6800 │ │ │ │ - @ instruction: 0x4603ef30 │ │ │ │ + @ instruction: 0x4603ead6 │ │ │ │ svccc 0x00fff1b3 │ │ │ │ @ instruction: 0xf8dfd107 │ │ │ │ ldrbtmi r3, [fp], #-1776 @ 0xfffff910 │ │ │ │ @ instruction: 0xf7fd4618 │ │ │ │ - movwcs lr, #3848 @ 0xf08 │ │ │ │ + movwcs lr, #2734 @ 0xaae │ │ │ │ @ instruction: 0xf107e361 │ │ │ │ - blcc b04674 <__time64@plt+0xb02df8> │ │ │ │ + blcc b04e64 <__time64@plt+0xb036ac> │ │ │ │ andls r2, r0, #4, 4 @ 0x40000000 │ │ │ │ tstcs r1, r2, lsl #4 │ │ │ │ andpl pc, r1, r7, lsl #10 │ │ │ │ eorseq pc, r0, r0, lsl #2 │ │ │ │ @ instruction: 0xf7fd6800 │ │ │ │ - @ instruction: 0x4603ef16 │ │ │ │ + @ instruction: 0x4603eabc │ │ │ │ svccc 0x00fff1b3 │ │ │ │ @ instruction: 0xf8dfd107 │ │ │ │ ldrbtmi r3, [fp], #-1728 @ 0xfffff940 │ │ │ │ @ instruction: 0xf7fd4618 │ │ │ │ - movwcs lr, #3822 @ 0xeee │ │ │ │ + movwcs lr, #2708 @ 0xa94 │ │ │ │ @ instruction: 0xf107e347 │ │ │ │ andcs r0, r2, #136, 6 @ 0x20000002 │ │ │ │ ldccs 8, cr15, [ip], #-140 @ 0xffffff74 │ │ │ │ @ instruction: 0xf7fd2000 │ │ │ │ - strmi lr, [r3], -r0, lsl #31 │ │ │ │ + strmi lr, [r3], -r6, lsr #22 │ │ │ │ addeq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ ldccc 8, cr15, [r8], #-264 @ 0xfffffef8 │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ stccc 8, cr15, [r4], {83} @ 0x53 │ │ │ │ @ instruction: 0x4618b29b │ │ │ │ - mcr 7, 6, pc, cr4, cr13, {7} @ │ │ │ │ + b 1ac2090 <__time64@plt+0x1ac08d8> │ │ │ │ ldrmi r4, [sl], -r3, lsl #12 │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ ldccs 8, cr15, [sl], #-140 @ 0xffffff74 │ │ │ │ orreq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ andscs r3, r0, #60, 22 @ 0xf000 │ │ │ │ @ instruction: 0xf5074619 │ │ │ │ @ instruction: 0xf1035301 │ │ │ │ ldmdavs r8, {r4, r5, r8, r9} │ │ │ │ - svc 0x003cf7fd │ │ │ │ - blcs 150e0 <__time64@plt+0x13864> │ │ │ │ + b ff8c20b4 <__time64@plt+0xff8c08fc> │ │ │ │ + blcs 158d0 <__time64@plt+0x14118> │ │ │ │ @ instruction: 0xf8dfd007 │ │ │ │ ldrbtmi r3, [fp], #-1632 @ 0xfffff9a0 │ │ │ │ @ instruction: 0xf7fd4618 │ │ │ │ - movwcs lr, #3772 @ 0xebc │ │ │ │ + movwcs lr, #2658 @ 0xa62 │ │ │ │ @ instruction: 0xf107e315 │ │ │ │ @ instruction: 0xf8530388 │ │ │ │ - blcs 12ae0 <__time64@plt+0x11264> │ │ │ │ + blcs 132d0 <__time64@plt+0x11b18> │ │ │ │ @ instruction: 0xf107d04b │ │ │ │ - blcc b04718 <__time64@plt+0xb02e9c> │ │ │ │ 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r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ rscne pc, sl, #74448896 @ 0x4700000 │ │ │ │ mulsle r0, r3, r2 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ rscsne pc, r4, #74448896 @ 0x4700000 │ │ │ │ mulle sl, r3, r2 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ rscsne pc, lr, #74448896 @ 0x4700000 │ │ │ │ mulle r4, r3, r2 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ - svclt 0x0000fc8b │ │ │ │ + svclt 0x0000fc89 │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ svcge 0x0000b08c │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ ldmdavs fp!, {r1, r5, r6, r7, pc}^ │ │ │ │ - blcc 625a0 <__time64@plt+0x60d24> │ │ │ │ + blcc 62d90 <__time64@plt+0x615d8> │ │ │ │ vpadd.i8 d2, d0, d6 │ │ │ │ andge r8, r2, #222 @ 0xde │ │ │ │ eorcc pc, r3, r2, asr r8 @ │ │ │ │ @ instruction: 0x4710441a │ │ │ │ strdeq r0, [r0], -pc @ │ │ │ │ @ instruction: 0x000001b3 │ │ │ │ andeq r0, r0, sp, asr r0 │ │ │ │ @@ -2757,106 +3314,106 @@ │ │ │ │ andeq r0, r0, r1, ror #2 │ │ │ │ @ instruction: 0x000001b3 │ │ │ │ @ instruction: 0x000001b3 │ │ │ │ andeq r0, r0, r9, lsl r1 │ │ │ │ andeq r0, r0, r9, ror r0 │ │ │ │ rscsvs r6, fp, fp, ror r8 │ │ │ │ @ instruction: 0xf89368fb │ │ │ │ - blcs 10540 <__time64@plt+0xecc4> │ │ │ │ + blcs 10d30 <__time64@plt+0xf578> │ │ │ │ adchi pc, r5, r0 │ │ │ │ mrcvs 8, 4, r6, cr11, cr11, {7} │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ - adds pc, lr, r9, lsr ip @ │ │ │ │ + adds pc, lr, r7, lsr ip @ │ │ │ │ mvnsvs r6, fp, ror r8 │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ movwcs r6, #635 @ 0x27b │ │ │ │ strd r6, [sl], -fp @ │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r9, fp, sp, lr}^ │ │ │ │ movwcs r6, #571 @ 0x23b │ │ │ │ @ instruction: 0xe00f62bb │ │ │ │ @ instruction: 0xf8936a3b │ │ │ │ - blcs 10494 <__time64@plt+0xec18> │ │ │ │ - bvs ef83f4 <__time64@plt+0xef6b78> │ │ │ │ + blcs 10c84 <__time64@plt+0xf4cc> │ │ │ │ + bvs ef8be4 <__time64@plt+0xef742c> │ │ │ │ @ instruction: 0x46186b5b │ │ │ │ - stc2 7, cr15, [r0], #-1016 @ 0xfffffc08 │ │ │ │ + ldc2 7, cr15, [lr], {254} @ 0xfe │ │ │ │ movwcc r6, #6843 @ 0x1abb │ │ │ │ - bvs edcee0 <__time64@plt+0xedb664> │ │ │ │ + bvs edd6d0 <__time64@plt+0xedbf18> │ │ │ │ eorsvs r3, fp, #56, 6 @ 0xe0000000 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, r9, fp, sp, lr}^ │ │ │ │ - bvs feed5c68 <__time64@plt+0xfeed43ec> │ │ │ │ - blle ffa54e50 <__time64@plt+0xffa535d4> │ │ │ │ + bvs feed6458 <__time64@plt+0xfeed4ca0> │ │ │ │ + blle ffa55640 <__time64@plt+0xffa53e88> │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, r9, fp, sp, lr}^ │ │ │ │ andle r2, r4, r0, lsl #22 │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r9, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ - bvs fff03444 <__time64@plt+0xfff01bc8> │ │ │ │ + bvs fff03c2c <__time64@plt+0xfff02474> │ │ │ │ rscsvs r3, fp, #67108864 @ 0x4000000 │ │ │ │ tstcc r8, #503808 @ 0x7b000 │ │ │ │ ldmibvs fp!, {r0, r1, r3, r4, r5, r6, r9, sp, lr}^ │ │ │ │ @ instruction: 0x461a7e5b │ │ │ │ addsmi r6, r3, #1028096 @ 0xfb000 │ │ │ │ ldmibvs fp!, {r1, r2, r3, r6, r7, r8, r9, fp, ip, lr, pc}^ │ │ │ │ - blcs 23da0 <__time64@plt+0x22524> │ │ │ │ + blcs 24590 <__time64@plt+0x22dd8> │ │ │ │ ldmibvs fp!, {r0, r1, r5, r6, ip, lr, pc}^ │ │ │ │ @ instruction: 0x461869db │ │ │ │ - blx ffdc243a <__time64@plt+0xffdc0bbe> │ │ │ │ + blx ffd42c2a <__time64@plt+0xffd41472> │ │ │ │ ldmdavs fp!, {r0, r2, r3, r4, r6, sp, lr, pc}^ │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r7, sp, lr} │ │ │ │ - blcs 237b8 <__time64@plt+0x21f3c> │ │ │ │ + blcs 23fa8 <__time64@plt+0x227f0> │ │ │ │ ldmvs fp!, {r0, r3, r4, r6, ip, lr, pc} │ │ │ │ @ instruction: 0x3090f8d3 │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ - subs pc, r2, r9, ror #23 │ │ │ │ + subs pc, r2, r7, ror #23 │ │ │ │ @ instruction: 0x61bb687b │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r5, r7, r8, fp, sp, lr} │ │ │ │ andle r2, r4, r0, lsl #22 │ │ │ │ - bvs 6deb58 <__time64@plt+0x6dd2dc> │ │ │ │ + bvs 6df348 <__time64@plt+0x6ddb90> │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ - movwcs pc, #3037 @ 0xbdd @ │ │ │ │ + movwcs pc, #3035 @ 0xbdb @ │ │ │ │ strd r6, [sl], -fp │ │ │ │ - bvs 169eb68 <__time64@plt+0x169d2ec> │ │ │ │ + bvs 169f358 <__time64@plt+0x169dba0> │ │ │ │ @ instruction: 0x011b6afb │ │ │ │ @ instruction: 0x46184413 │ │ │ │ @ instruction: 0xff2cf7ff │ │ │ │ movwcc r6, #6907 @ 0x1afb │ │ │ │ ldmibvs fp!, {r0, r1, r3, r4, r5, r6, r7, r9, sp, lr} │ │ │ │ - bvs ffedebfc <__time64@plt+0xffedd380> │ │ │ │ + bvs ffedf3ec <__time64@plt+0xffeddc34> │ │ │ │ stmiale pc!, {r1, r3, r4, r7, r9, lr}^ @ │ │ │ │ - bvs 16deb88 <__time64@plt+0x16dd30c> │ │ │ │ + bvs 16df378 <__time64@plt+0x16ddbc0> │ │ │ │ @ instruction: 0xf7fe4618 │ │ │ │ - eor pc, pc, r5, asr #23 │ │ │ │ + eor pc, pc, r3, asr #23 │ │ │ │ cmnvs fp, fp, ror r8 │ │ │ │ tstcc ip, #2015232 @ 0x1ec000 │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r8, sp, lr} │ │ │ │ - blcs 1e520 <__time64@plt+0x1cca4> │ │ │ │ + blcs 1ed10 <__time64@plt+0x1d558> │ │ │ │ ldmdbvs fp!, {r2, ip, lr, pc} │ │ │ │ @ instruction: 0x4618689b │ │ │ │ - blx fedc24ba <__time64@plt+0xfedc0c3e> │ │ │ │ + blx fed42caa <__time64@plt+0xfed414f2> │ │ │ │ rscsvs r2, fp, #0, 6 │ │ │ │ ldmdbvs fp!, {r1, r3, sp, lr, pc} │ │ │ │ - bvs ffede834 <__time64@plt+0xffedcfb8> │ │ │ │ + bvs ffedf024 <__time64@plt+0xffedd86c> │ │ │ │ ldrmi r0, [r3], #-283 @ 0xfffffee5 │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ - bvs fff040ec <__time64@plt+0xfff02870> │ │ │ │ + bvs fff048dc <__time64@plt+0xfff03124> │ │ │ │ rscsvs r3, fp, #67108864 @ 0x4000000 │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ addsmi r6, sl, #1028096 @ 0xfb000 │ │ │ │ ldmdbvs fp!, {r0, r1, r2, r3, r5, r6, r7, fp, ip, lr, pc} │ │ │ │ @ instruction: 0x461868db │ │ │ │ - blx fe7c24ea <__time64@plt+0xfe7c0c6e> │ │ │ │ + blx fe742cda <__time64@plt+0xfe741522> │ │ │ │ svclt 0x0000e008 │ │ │ │ svclt 0x0000e006 │ │ │ │ svclt 0x0000e004 │ │ │ │ svclt 0x0000e002 │ │ │ │ svclt 0x0000e000 │ │ │ │ @ instruction: 0x46bd3730 │ │ │ │ strlt fp, [r0], #3456 @ 0xd80 │ │ │ │ svcge 0x0000b089 │ │ │ │ ldmdavs fp!, {r3, r4, r5, r6, sp, lr}^ │ │ │ │ - blcs 5e2784 <__time64@plt+0x5e0f08> │ │ │ │ + blcs 5e2f74 <__time64@plt+0x5e17bc> │ │ │ │ ldmdavs fp!, {r0, r1, r6, r8, ip, lr, pc}^ │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r7, sp, lr} │ │ │ │ ldrsbvs r6, [fp, #-155]! @ 0xffffff65 │ │ │ │ mvnsvs r2, r0, lsl #6 │ │ │ │ ldmdbvs fp!, {r2, r4, r5, sp, lr, pc}^ │ │ │ │ teqvs fp, fp, asr r9 │ │ │ │ rscsvs r2, fp, r0, lsl #6 │ │ │ │ @@ -2873,77 +3430,77 @@ │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r7, r8, sp, lr} │ │ │ │ teqvs fp, r8, lsr r3 │ │ │ │ ldmibvs sl, {r0, r1, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0x211869fb │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ ldmdavc fp, {r0, r1, r4, sl, lr}^ │ │ │ │ ldmibvs fp!, {r1, r3, r4, r9, sl, lr} │ │ │ │ - blle ff794fc8 <__time64@plt+0xff79374c> │ │ │ │ + blle ff7957b8 <__time64@plt+0xff794000> │ │ │ │ sbcslt r6, fp, #16449536 @ 0xfb0000 │ │ │ │ sbcslt r3, sl, #335544320 @ 0x14000000 │ │ │ │ andsvc r6, sl, fp, ror r9 │ │ │ │ movwcc r6, #6651 @ 0x19fb │ │ │ │ ldmdbvs fp!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ cmnvs fp, r8, lsl r3 │ │ │ │ mrcvc 8, 2, r6, cr11, cr11, {5} │ │ │ │ ldmibvs fp!, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ - blle ff114fec <__time64@plt+0xff113770> │ │ │ │ + blle ff1157dc <__time64@plt+0xff114024> │ │ │ │ svclt 0x0000e000 │ │ │ │ strcc fp, [r4, -r0, lsl #30]! │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ svcmi 0x00b0e92d │ │ │ │ svcge 0x0000b08c │ │ │ │ @ instruction: 0xf10760f8 │ │ │ │ @ instruction: 0xf1070210 │ │ │ │ @ instruction: 0x46110318 │ │ │ │ - @ instruction: 0xf7fd4618 │ │ │ │ - strmi lr, [r3], -lr, lsl #18 │ │ │ │ + @ instruction: 0xf7fc4618 │ │ │ │ + @ instruction: 0x4603ecb4 │ │ │ │ andle r2, r2, r0, lsl #22 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ ldmib r7, {r3, r4, r6, sp, lr, pc}^ │ │ │ │ vst4.8 {d16,d18,d20,d22}, [pc], r6 │ │ │ │ @ instruction: 0xf04f6261 │ │ │ │ @ instruction: 0xf0050300 │ │ │ │ strmi pc, [r2], -r9, lsl #22 │ │ │ │ ldmvs fp!, {r0, r1, r3, r9, sl, lr}^ │ │ │ │ ldmib r7, {r1, r3, r4, sp, lr}^ │ │ │ │ vst4.8 {d16,d18,d20,d22}, [pc], r6 │ │ │ │ @ instruction: 0xf04f6261 │ │ │ │ @ instruction: 0xf0050300 │ │ │ │ vpmin.s8 , q10, │ │ │ │ vmla.f d18, d0, d0[0] │ │ │ │ - blx 44a46 <__time64@plt+0x431ca> │ │ │ │ + blx 45236 <__time64@plt+0x43a7e> │ │ │ │ tstpcs r0, r3 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf101fb02 │ │ │ │ vshl.s8 d20, d8, d4 │ │ │ │ vmla.f d18, d0, d0[0] │ │ │ │ - blx fe884a5a <__time64@plt+0xfe8831de> │ │ │ │ + blx fe88524a <__time64@plt+0xfe883a92> │ │ │ │ stmdbne r3, {r0, r8, sl, lr}^ │ │ │ │ ldmib r7, {r0, r2, r3, r4, r9, sl, lr}^ │ │ │ │ - bl 50d248 <__time64@plt+0x50b9cc> │ │ │ │ - bl 1146e34 <__time64@plt+0x11455b8> │ │ │ │ + bl 50da38 <__time64@plt+0x50c280> │ │ │ │ + bl 1147624 <__time64@plt+0x1145e6c> │ │ │ │ stmib r7, {r0, r1, r8, r9, fp}^ │ │ │ │ ldmib r7, {r1, r3, r8, r9, fp, sp, pc}^ │ │ │ │ strtmi r4, [r2], -sl, lsl #10 │ │ │ │ @ instruction: 0xf04f462b │ │ │ │ @ instruction: 0xf04f0000 │ │ │ │ ldreq r0, [r9, r0, lsl #2] │ │ │ │ orrseq lr, r2, r1, asr #20 │ │ │ │ @ instruction: 0x46020790 │ │ │ │ - bl fec95e7c <__time64@plt+0xfec94600> │ │ │ │ - bl 18c6664 <__time64@plt+0x18c4de8> │ │ │ │ - bl 606a6c <__time64@plt+0x6051f0> │ │ │ │ + bl fec9666c <__time64@plt+0xfec94eb4> │ │ │ │ + bl 18c6e54 <__time64@plt+0x18c569c> │ │ │ │ + bl 60725c <__time64@plt+0x605aa4> │ │ │ │ eorsvs r0, fp, r8, lsl #6 │ │ │ │ movweq lr, #39753 @ 0x9b49 │ │ │ │ ldmib r7, {r0, r1, r3, r4, r5, r6, sp, lr}^ │ │ │ │ strbmi r8, [r0], -r0, lsl #18 │ │ │ │ movwge r4, #42569 @ 0xa649 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ - blx ff0c0688 <__time64@plt+0xff0bee0c> │ │ │ │ + blx ff0c0e78 <__time64@plt+0xff0bf6c0> │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ movwcs lr, #43463 @ 0xa9c7 │ │ │ │ @ instruction: 0xf0236abb │ │ │ │ ldmvs fp!, {r9, lr}^ │ │ │ │ movwcs r6, #90 @ 0x5a │ │ │ │ @ instruction: 0x37304618 │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ @@ -2951,52 +3508,52 @@ │ │ │ │ ldrle sl, [r3], r0, lsl #8 │ │ │ │ andeq r0, r0, r0 │ │ │ │ svcmi 0x00b0e92d │ │ │ │ svcge 0x0000b08c │ │ │ │ @ instruction: 0xf10760f8 │ │ │ │ @ instruction: 0xf1070210 │ │ │ │ @ instruction: 0x46110318 │ │ │ │ - @ instruction: 0xf7fd4618 │ │ │ │ - @ instruction: 0x4603e898 │ │ │ │ + @ instruction: 0xf7fc4618 │ │ │ │ + @ instruction: 0x4603ec3e │ │ │ │ andle r2, r2, r0, lsl #22 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ ldmib r7, {r2, r3, r6, sp, lr, pc}^ │ │ │ │ vst4.8 {d16,d18,d20,d22}, [pc], r6 │ │ │ │ @ instruction: 0xf04f6261 │ │ │ │ @ instruction: 0xf0050300 │ │ │ │ vpmin.s8 d31, d20, d3 │ │ │ │ vmla.f d18, d0, d0[0] │ │ │ │ - blx 44b1a <__time64@plt+0x4329e> │ │ │ │ + blx 4530a <__time64@plt+0x43b52> │ │ │ │ tstpcs r0, r3 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf101fb02 │ │ │ │ vshl.s8 d20, d8, d4 │ │ │ │ vmla.f d18, d0, d0[0] │ │ │ │ - blx fe884b2e <__time64@plt+0xfe8832b2> │ │ │ │ - bl 26af8 <__time64@plt+0x2527c> │ │ │ │ + blx fe88531e <__time64@plt+0xfe883b66> │ │ │ │ + bl 272e8 <__time64@plt+0x25b30> │ │ │ │ ldrmi r0, [r9], r9, lsl #6 │ │ │ │ movwcs lr, #35287 @ 0x89d7 │ │ │ │ - beq bf360 <__time64@plt+0xbdae4> │ │ │ │ - bleq ff428 <__time64@plt+0xfdbac> │ │ │ │ - blge 2bee24 <__time64@plt+0x2bd5a8> │ │ │ │ + beq bfb50 <__time64@plt+0xbe398> │ │ │ │ + bleq ffc18 <__time64@plt+0xfe460> │ │ │ │ + blge 2bf614 <__time64@plt+0x2bde5c> │ │ │ │ stmdbhi sl, {r0, r1, r2, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ strbmi r4, [fp], -r2, asr #12 │ │ │ │ andeq pc, r0, pc, asr #32 │ │ │ │ tstpeq r0, pc, asr #32 @ p-variant is OBSOLETE │ │ │ │ - b 1046580 <__time64@plt+0x1044d04> │ │ │ │ + b 1046d70 <__time64@plt+0x10455b8> │ │ │ │ @ instruction: 0x07900192 │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ streq lr, [r8], #-2994 @ 0xfffff44e │ │ │ │ streq lr, [r9, #-2915] @ 0xfffff49d │ │ │ │ eorsvs r1, fp, r3, lsr #18 │ │ │ │ movweq lr, #23365 @ 0x5b45 │ │ │ │ ldmib r7, {r0, r1, r3, r4, r5, r6, sp, lr}^ │ │ │ │ strtmi r4, [r0], -r0, lsl #10 │ │ │ │ movwge r4, #46633 @ 0xb629 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ - blx 164075c <__time64@plt+0x163eee0> │ │ │ │ + blx 1640f4c <__time64@plt+0x163f794> │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ movwcs lr, #43463 @ 0xa9c7 │ │ │ │ @ instruction: 0xf0236abb │ │ │ │ ldmvs fp!, {r3, r4, r5, r6, r9, lr}^ │ │ │ │ movwcs r6, #26 │ │ │ │ @ instruction: 0x37304618 │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ @@ -3006,106 +3563,106 @@ │ │ │ │ andeq r0, r0, r0 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ movwcs r6, #57 @ 0x39 │ │ │ │ ldrbtmi r4, [sl], #-2564 @ 0xfffff5fc │ │ │ │ cmnpcc r3, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [r8], #-2051 @ 0xfffff7fd │ │ │ │ - @ instruction: 0xf8e2f7fe │ │ │ │ - ldmda r8, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - andeq r7, r0, r6, lsl r2 │ │ │ │ - andeq r6, r0, sl, asr pc │ │ │ │ + @ instruction: 0xf8e0f7fe │ │ │ │ + bl fffc2f74 <__time64@plt+0xfffc17bc> │ │ │ │ + muleq r0, sl, r1 │ │ │ │ + ldrdeq r6, [r0], -lr │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ movwcs r6, #57 @ 0x39 │ │ │ │ ldrbtmi r4, [sl], #-2564 @ 0xfffff5fc │ │ │ │ orrcc pc, r1, r0, asr #4 │ │ │ │ ldrbtmi r4, [r8], #-2051 @ 0xfffff7fd │ │ │ │ - @ instruction: 0xf8cef7fe │ │ │ │ - stmda r4, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - andeq r7, r0, lr, ror #3 │ │ │ │ - andeq r6, r0, r2, lsr pc │ │ │ │ + @ instruction: 0xf8ccf7fe │ │ │ │ + bl ffac2f9c <__time64@plt+0xffac17e4> │ │ │ │ + andeq r7, r0, r2, ror r1 │ │ │ │ + @ instruction: 0x00006eb6 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ @ instruction: 0x3058f893 │ │ │ │ - blcs 2133dc <__time64@plt+0x211b60> │ │ │ │ + blcs 213bcc <__time64@plt+0x212414> │ │ │ │ andcs fp, r1, #140, 30 @ 0x230 │ │ │ │ sbcslt r2, r2, #0, 4 │ │ │ │ tstle r9, r0, lsl #20 │ │ │ │ addsmi r2, sl, r1, lsl #4 │ │ │ │ teqpne r3, #64, 4 @ p-variant is OBSOLETE │ │ │ │ - blcs 1483c <__time64@plt+0x12fc0> │ │ │ │ + blcs 1502c <__time64@plt+0x13874> │ │ │ │ movwcs fp, #7956 @ 0x1f14 │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ tstle pc, r0, lsl #22 │ │ │ │ biceq pc, ip, #2 │ │ │ │ svclt 0x00142b00 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ - blcs 31378 <__time64@plt+0x2fafc> │ │ │ │ + blcs 31b68 <__time64@plt+0x303b0> │ │ │ │ ldmdavs r9!, {r2, ip, lr, pc} │ │ │ │ @ instruction: 0xf0006878 │ │ │ │ and pc, r2, fp, lsr #16 │ │ │ │ and fp, r0, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r8, r9, sl, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf503687a │ │ │ │ @ instruction: 0x461173d0 │ │ │ │ @ instruction: 0x46182298 │ │ │ │ - mcr 7, 7, pc, cr4, cr12, {7} @ │ │ │ │ + b fe5c3010 <__time64@plt+0xfe5c1858> │ │ │ │ ldcl 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ @ instruction: 0xeeb77a14 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r5, r6, r7, r9, fp, ip, sp, lr}^ │ │ │ │ - bvs 4fff8c <__time64@plt+0x4fe710> │ │ │ │ - bvs ff9c0320 <__time64@plt+0xff9beaa4> │ │ │ │ + bvs 50077c <__time64@plt+0x4fefc4> │ │ │ │ + bvs ff9c0b10 <__time64@plt+0xff9bf358> │ │ │ │ ldcl 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ @ instruction: 0xeeb75a12 │ │ │ │ ldmdavs fp!, {r0, r2, r5, r6, r7, r9, fp, ip, lr} │ │ │ │ ldrmi r3, [r8], -r0, lsr #6 │ │ │ │ - blcs 1180318 <__time64@plt+0x117ea9c> │ │ │ │ - blne 11c031c <__time64@plt+0x11beaa0> │ │ │ │ - bleq 1200320 <__time64@plt+0x11feaa4> │ │ │ │ - ldc2 7, cr15, [lr, #-1012] @ 0xfffffc0c │ │ │ │ + blcs 1180b08 <__time64@plt+0x117f350> │ │ │ │ + blne 11c0b0c <__time64@plt+0x11bf354> │ │ │ │ + bleq 1200b10 <__time64@plt+0x11ff358> │ │ │ │ + blx ffc43048 <__time64@plt+0xffc41890> │ │ │ │ strcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addslt fp, r0, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xf04f6039 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ @ instruction: 0xf04f230e │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ @ instruction: 0xf04f230c │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ ldmdavs fp!, {r1, r3, r8, r9, sp}^ │ │ │ │ - bvc 77ffec <__time64@plt+0x77e770> │ │ │ │ - bvc ffa00380 <__time64@plt+0xff9feb04> │ │ │ │ - blvc 23fec4 <__time64@plt+0x23e648> │ │ │ │ + bvc 7807dc <__time64@plt+0x77f024> │ │ │ │ + bvc ffa00b70 <__time64@plt+0xff9ff3b8> │ │ │ │ + blvc 2406b4 <__time64@plt+0x23eefc> │ │ │ │ ldcl 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ @ instruction: 0xeeb77a1e │ │ │ │ vstr s14, [r7, #924] @ 0x39c │ │ │ │ ldmdavs fp!, {r1, r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - bvc 800008 <__time64@plt+0x7fe78c> │ │ │ │ - bvc ffa0039c <__time64@plt+0xff9feb20> │ │ │ │ - blvc 13fee0 <__time64@plt+0x13e664> │ │ │ │ - blvc 23ff24 <__time64@plt+0x23e6a8> │ │ │ │ - blvs 200168 <__time64@plt+0x1fe8ec> │ │ │ │ - blvc 1bff2c <__time64@plt+0x1be6b0> │ │ │ │ - blvc 200170 <__time64@plt+0x1fe8f4> │ │ │ │ - blvs 2001b0 <__time64@plt+0x1fe934> │ │ │ │ - blvc 13ff38 <__time64@plt+0x13e6bc> │ │ │ │ - blvc 20017c <__time64@plt+0x1fe900> │ │ │ │ - blvc 2001bc <__time64@plt+0x1fe940> │ │ │ │ - bleq 12003a8 <__time64@plt+0x11feb2c> │ │ │ │ - svc 0x001cf7fc │ │ │ │ - bleq bff0c <__time64@plt+0xbe690> │ │ │ │ - blvc bff50 <__time64@plt+0xbe6d4> │ │ │ │ - blvc ff0403cc <__time64@plt+0xff03eb50> │ │ │ │ - blx 4404c0 <__time64@plt+0x43ec44> │ │ │ │ + bvc 8007f8 <__time64@plt+0x7ff040> │ │ │ │ + bvc ffa00b8c <__time64@plt+0xff9ff3d4> │ │ │ │ + blvc 1406d0 <__time64@plt+0x13ef18> │ │ │ │ + blvc 240714 <__time64@plt+0x23ef5c> │ │ │ │ + blvs 200958 <__time64@plt+0x1ff1a0> │ │ │ │ + blvc 1c071c <__time64@plt+0x1bef64> │ │ │ │ + blvc 200960 <__time64@plt+0x1ff1a8> │ │ │ │ + blvs 2009a0 <__time64@plt+0x1ff1e8> │ │ │ │ + blvc 140728 <__time64@plt+0x13ef70> │ │ │ │ + blvc 20096c <__time64@plt+0x1ff1b4> │ │ │ │ + blvc 2009ac <__time64@plt+0x1ff1f4> │ │ │ │ + bleq 1200b98 <__time64@plt+0x11ff3e0> │ │ │ │ + b ff0c30cc <__time64@plt+0xff0c1914> │ │ │ │ + bleq c06fc <__time64@plt+0xbef44> │ │ │ │ + blvc c0740 <__time64@plt+0xbef88> │ │ │ │ + blvc ff040bbc <__time64@plt+0xff03f404> │ │ │ │ + blx 440cb0 <__time64@plt+0x43f4f8> │ │ │ │ ldc 13, cr13, [r7, #92] @ 0x5c │ │ │ │ vldr d5, [r7, #32] │ │ │ │ vdiv.f64 d6, d5, d2 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #56] @ 0x38 │ │ │ │ vldr d5, [r7, #24] │ │ │ │ vdiv.f64 d6, d5, d2 │ │ │ │ @@ -3125,91 +3682,91 @@ │ │ │ │ stmib r1, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r4, r5, r8, r9, sp} │ │ │ │ teqcs r2, #3457024 @ 0x34c000 │ │ │ │ stmib r1, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ ldc 3, cr2, [r7, #160] @ 0xa0 │ │ │ │ vmov.f64 d7, #26 @ 0x40d00000 6.5 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc c3ff78 <__time64@plt+0xc3e6fc> │ │ │ │ + blvc c40768 <__time64@plt+0xc3efb0> │ │ │ │ ldmib r7, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ stmib r1, {r1, r3, r8, r9, sp}^ │ │ │ │ ldmdavs r9!, {r1, r3, r5, r8, r9, sp} │ │ │ │ movwcs lr, #51671 @ 0xc9d7 │ │ │ │ teqcs r8, #3162112 @ 0x304000 │ │ │ │ - blvc 33ffe0 <__time64@plt+0x33e764> │ │ │ │ - blvc 120044c <__time64@plt+0x11febd0> │ │ │ │ + blvc 3407d0 <__time64@plt+0x33f018> │ │ │ │ + blvc 1200c3c <__time64@plt+0x11ff484> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ vldr d7, [r7, #176] @ 0xb0 │ │ │ │ vmov.f64 d7, #30 @ 0x40f00000 7.5 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc ebffa8 <__time64@plt+0xebe72c> │ │ │ │ + blvc ec0798 <__time64@plt+0xebefe0> │ │ │ │ ldmib r7, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ stmib r1, {r1, r2, r3, r8, r9, sp}^ │ │ │ │ ldc 3, cr2, [r7, #208] @ 0xd0 │ │ │ │ vmul.f64 d7, d7, d14 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 123ffc0 <__time64@plt+0x123e744> │ │ │ │ - blvs 3c0014 <__time64@plt+0x3be798> │ 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lr} │ │ │ │ - blvc 14c0004 <__time64@plt+0x14be788> │ │ │ │ - blvs 340058 <__time64@plt+0x33e7dc> │ │ │ │ - blvc 2c005c <__time64@plt+0x2be7e0> │ │ │ │ - blvc 20029c <__time64@plt+0x1fea20> │ │ │ │ + blvc 14c07f4 <__time64@plt+0x14bf03c> │ │ │ │ + blvs 340848 <__time64@plt+0x33f090> │ │ │ │ + blvc 2c084c <__time64@plt+0x2bf094> │ │ │ │ + blvc 200a8c <__time64@plt+0x1ff2d4> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ vldr d7, [r7, #360] @ 0x168 │ │ │ │ vldr d6, [r7, #40] @ 0x28 │ │ │ │ vmul.f64 d7, d6, d14 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 1340028 <__time64@plt+0x133e7ac> │ │ │ │ - blvs 2c007c <__time64@plt+0x2be800> │ │ │ │ - blvc 340080 <__time64@plt+0x33e804> │ │ │ │ - blvc 2002c0 <__time64@plt+0x1fea44> │ │ │ │ + blvc 1340818 <__time64@plt+0x133f060> │ │ │ │ + blvs 2c086c <__time64@plt+0x2bf0b4> │ │ │ │ + blvc 340870 <__time64@plt+0x33f0b8> │ │ │ │ + blvc 200ab0 <__time64@plt+0x1ff2f8> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ vldr d7, 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0xd104429a │ │ │ │ movwcs lr, #35287 @ 0x89d7 │ │ │ │ movwcs lr, #59847 @ 0xe9c7 │ │ │ │ @ instruction: 0xf04fe005 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ ldmvs sl!, {r1, r2, r3, r8, r9, sp}^ │ │ │ │ @@ -3229,20 +3786,20 @@ │ │ │ │ vldr d5, [r7] │ │ │ │ vmul.f64 d7, d5, d4 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ ldmvs sl!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ addseq r6, r9, fp, ror fp │ │ │ │ strmi r6, [fp], #-2875 @ 0xfffff4c5 │ │ │ │ ldrmi r0, [r3], #-219 @ 0xffffff25 │ │ │ │ - blvc 40118 <__time64@plt+0x3e89c> │ │ │ │ + blvc 40908 <__time64@plt+0x3f150> │ │ │ │ movwcc r6, #6971 @ 0x1b3b │ │ │ │ - blvs edd800 <__time64@plt+0xedbf84> │ │ │ │ + blvs eddff0 <__time64@plt+0xedc838> │ │ │ │ @ instruction: 0xddbf2b02 │ │ │ │ movwcc r6, #7035 @ 0x1b7b │ │ │ │ - blvs 1edd90c <__time64@plt+0x1edc090> │ │ │ │ + blvs 1ede0fc <__time64@plt+0x1edc944> │ │ │ │ @ instruction: 0xddb62b02 │ │ │ │ @ instruction: 0xf04f68b9 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ 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<__time64@plt+0x1feeb4> │ │ │ │ + bvc 280d84 <__time64@plt+0x27f5cc> │ │ │ │ + bpl ffa01118 <__time64@plt+0xff9ff960> │ │ │ │ + blvc c0c9c <__time64@plt+0xbf4e4> │ │ │ │ + blvc 200ed8 <__time64@plt+0x1ff720> │ │ │ │ + blvc 200f20 <__time64@plt+0x1ff768> │ │ │ │ @ instruction: 0xed83693b │ │ │ │ @ instruction: 0xf8d77b00 │ │ │ │ ldc 0, cr3, [r3, #656] @ 0x290 │ │ │ │ @ instruction: 0xf8d76b0e │ │ │ │ ldcl 0, cr3, [r3, #656] @ 0x290 │ │ │ │ vmov.f32 s14, #122 @ 0x3fd00000 1.625 │ │ │ │ vldr s10, [r7, #924] @ 0x39c │ │ │ │ vmul.f64 d7, d5, d2 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ ldmdbvs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc c0490 <__time64@plt+0xbec14> │ │ │ │ + blvc c0c80 <__time64@plt+0xbf4c8> │ │ │ │ ldrdcc pc, [r4], r7 @ │ │ │ │ - blvs 4404d8 <__time64@plt+0x43ec5c> │ │ │ │ + blvs 440cc8 <__time64@plt+0x43f510> │ │ │ │ ldrdcc pc, [r4], r7 @ │ │ │ │ - bvc 3005e0 <__time64@plt+0x2fed64> │ │ │ │ - bpl ffa00974 <__time64@plt+0xff9ff0f8> │ │ │ │ - blvc c04f8 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0xf8d77a00 │ │ │ │ ldcl 0, cr3, [r3, #656] @ 0x290 │ │ │ │ vmov.f32 s14, #122 @ 0x3fd00000 1.625 │ │ │ │ @ instruction: 0xf8d76ae7 │ │ │ │ ldcl 0, cr3, [r3, #656] @ 0x290 │ │ │ │ @ instruction: 0xeeb77a1b │ │ │ │ vldr s10, [r7, #924] @ 0x39c │ │ │ │ vmul.f64 d7, d5, d2 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vmov.f64 d23, #119 @ 0x3fb80000 1.4375000 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r6, r7, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - bvc 80708 <__time64@plt+0x7ee8c> │ │ │ │ + bvc 80ef8 <__time64@plt+0x7f740> │ │ │ │ ldrdcc pc, [r4], r7 @ │ │ │ │ - bvc 300750 <__time64@plt+0x2feed4> │ │ │ │ - bvs ffa00ae4 <__time64@plt+0xff9ff268> │ │ │ │ + bvc 300f40 <__time64@plt+0x2ff788> │ │ │ │ + bvs ffa012d4 <__time64@plt+0xff9ffb1c> │ │ │ │ ldrdcc pc, [r4], r7 @ │ │ │ │ - bvc 74075c <__time64@plt+0x73eee0> │ │ │ │ - bpl ffa00af0 <__time64@plt+0xff9ff274> │ │ │ │ - blvc c0674 <__time64@plt+0xbedf8> │ │ │ │ - blvc 2008b0 <__time64@plt+0x1ff034> │ │ │ │ - blvc 2008f8 <__time64@plt+0x1ff07c> │ │ │ │ - blvc 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│ stc 1, cr6, [r7, #992] @ 0x3e0 │ │ │ │ vstr d0, [r7, #16] │ │ │ │ vstr d1, [r7, #8] │ │ │ │ ldmibvs r9!, {r8, r9, fp, sp}^ │ │ │ │ movwcs lr, #18903 @ 0x49d7 │ │ │ │ @@ -3615,29 +4172,29 @@ │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ smlallt fp, r3, r0, r5 │ │ │ │ @ instruction: 0xf507af00 │ │ │ │ @ instruction: 0xf5a373c4 │ │ │ │ @ instruction: 0x601873ba │ │ │ │ movweq pc, #33031 @ 0x8107 @ │ │ │ │ - bleq 40720 <__time64@plt+0x3eea4> │ │ │ │ + bleq 40f10 <__time64@plt+0x3f758> │ │ │ │ bicvc pc, r4, #29360128 @ 0x1c00000 │ │ │ │ @ instruction: 0x73bcf5a3 │ │ │ │ @ instruction: 0xf5076019 │ │ │ │ @ instruction: 0xf5a373c4 │ │ │ │ andsvs r7, sl, r2, asr #7 │ │ │ │ @ instruction: 0xf8c72300 │ │ │ │ @ instruction: 0xf5073184 │ │ │ │ @ instruction: 0xf5a373c4 │ │ │ │ ldmdavs fp, {r1, r3, r4, r5, r7, r8, r9, ip, sp, lr} │ │ │ │ - blvc 40788 <__time64@plt+0x3ef0c> │ │ │ │ + blvc 40f78 <__time64@plt+0x3f7c0> │ │ │ │ movweq pc, #33031 @ 0x8107 @ │ │ │ │ - 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{r0, r1, r3, r4, r5, r6, r8, r9, sl, fp, sp, lr} │ │ │ │ subscc pc, ip, r7, lsl #17 │ │ │ │ @ instruction: 0xf8872300 │ │ │ │ svcvs 0x007b305d │ │ │ │ @ instruction: 0xf107617b │ │ │ │ andcs r0, r0, #20, 6 @ 0x50000000 │ │ │ │ svcvs 0x00b84619 │ │ │ │ - stm r6, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldc 7, cr15, [r8], #-1004 @ 0xfffffc14 │ │ │ │ svcvs 0x003b6738 │ │ │ │ - blle d00a0 <__time64@plt+0xce824> │ │ │ │ + blle d0890 <__time64@plt+0xcf0d8> │ │ │ │ @ instruction: 0xf5b36f3b │ │ │ │ - blle 552a8 <__time64@plt+0x53a2c> │ │ │ │ + blle 55a98 <__time64@plt+0x542e0> │ │ │ │ sub r2, ip, r3, lsl #6 │ │ │ │ addslt r6, sl, #59, 30 @ 0xec │ │ │ │ @ instruction: 0x801a68fb │ │ │ │ svcvs 0x007a697b │ │ │ │ mulle r1, sl, r2 │ │ │ │ sub r2, r2, r4, lsl #6 │ │ │ │ movwcc r6, #8059 @ 0x1f7b │ │ │ │ @ instruction: 0xf10767bb │ │ │ │ @ instruction: 0x4619035c │ │ │ │ - @ instruction: 0xf7fc6fb8 │ │ │ │ - @ instruction: 0x6778e990 │ │ │ │ - blcs 212c4 <__time64@plt+0x1fa48> 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0x11da │ │ │ │ @ instruction: 0x37384618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ strdlt fp, [r9], r0 │ │ │ │ rsbsvs sl, r8, r6, lsl #30 │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @@ -4003,89 +4560,89 @@ │ │ │ │ @ instruction: 0x461c799b │ │ │ │ ldmibvc fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ strls r9, [r3], #-772 @ 0xfffffcfc │ │ │ │ tstls r1, r2 │ │ │ │ ldrtmi r9, [r3], -r0, lsl #4 │ │ │ │ stmdbmi r6, {r1, r3, r5, r9, sl, lr} │ │ │ │ stmdami r6, {r0, r3, r4, r5, r6, sl, lr} │ │ │ │ - @ instruction: 0xf7fc4478 │ │ │ │ - blmi 17f860 <__time64@plt+0x17dfe4> │ │ │ │ + @ instruction: 0xf7fb4478 │ │ │ │ + blmi 180ee8 <__time64@plt+0x17f730> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ svclt 0x0000bdf0 │ │ │ │ - muleq r0, r0, r2 │ │ │ │ - ldrdeq r9, [r0], -r4 │ │ │ │ - andeq r9, r0, ip, asr #5 │ │ │ │ + andeq r6, r0, r4, lsl r2 │ │ │ │ + andeq r9, r0, r4, asr fp │ │ │ │ + andeq r9, r0, ip, asr #22 │ │ │ │ andeq r0, r0, r0 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ stc 15, cr10, [r7] │ │ │ │ vldr d0, [r7] │ │ │ │ vmov.f64 d7, #0 @ 0x40000000 2.0 │ │ │ │ - vldr d7, [pc, #796] @ 5a74 <__time64@plt+0x41f8> │ │ │ │ + vldr d7, [pc, #796] @ 6264 <__time64@plt+0x4aac> │ │ │ │ vmov.u16 r6, d4[2] │ │ │ │ vneg.f64 d23, d6 │ │ │ │ stmdble r2, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ movwcs lr, #2519 @ 0x9d7 │ │ │ │ ldc 0, cr14, [r7, #432] @ 0x1b0 │ │ │ │ - vldr d7, [pc] @ 5770 <__time64@plt+0x3ef4> │ │ │ │ + vldr d7, [pc] @ 5f60 <__time64@plt+0x47a8> │ │ │ │ vmov.u16 r6, d4[2] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ vldrle s30, [r9, #-64] @ 0xffffffc0 │ │ │ │ - blvc 40ddc <__time64@plt+0x3f560> │ │ │ │ - blpl e40e00 <__time64@plt+0xe3f584> │ │ │ │ - blvs 1811a4 <__time64@plt+0x17f928> │ │ │ │ - bleq 11c124c <__time64@plt+0x11bf9d0> │ │ │ │ - svc 0x0076f7fb │ │ │ │ - blvc 1041254 <__time64@plt+0x103f9d8> │ │ │ │ - blvs 41274 <__time64@plt+0x3f9f8> │ │ │ │ - blvc 1c1078 <__time64@plt+0x1bf7fc> │ │ │ │ - blvs c80e1c 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d23, d6 │ │ │ │ vstrle s30, [r8, #-64] @ 0xffffffc0 │ │ │ │ - blvs 680e8c <__time64@plt+0x67f610> │ │ │ │ - blvc 40e70 <__time64@plt+0x3f5f4> │ │ │ │ - blvc 12010f0 <__time64@plt+0x11ff874> │ │ │ │ - blvc 40e38 <__time64@plt+0x3f5bc> │ │ │ │ + blvs 68167c <__time64@plt+0x67fec4> │ │ │ │ + blvc 41660 <__time64@plt+0x3fea8> │ │ │ │ + blvc 12018e0 <__time64@plt+0x1200128> │ │ │ │ + blvc 41628 <__time64@plt+0x3fe70> │ │ │ │ ldc 0, cr14, [r7, #64] @ 0x40 │ │ │ │ - vldr d7, [pc] @ 5824 <__time64@plt+0x3fa8> │ │ │ │ + vldr d7, [pc] @ 6014 <__time64@plt+0x485c> │ │ │ │ vmov.32 r6, d4[1] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ strle pc, [r7, #-2576] @ 0xfffff5f0 │ │ │ │ - blvs 3c0eb0 <__time64@plt+0x3bf634> │ │ │ │ - blvc 40e94 <__time64@plt+0x3f618> │ │ │ │ - blvc 1201114 <__time64@plt+0x11ff898> │ │ │ │ - blvc 40e5c <__time64@plt+0x3f5e0> │ │ │ │ + blvs 3c16a0 <__time64@plt+0x3bfee8> │ │ │ │ + blvc 41684 <__time64@plt+0x3fecc> │ │ │ │ + blvc 1201904 <__time64@plt+0x120014c> │ │ │ │ + blvc 4164c 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0, cr14, [r7, #432] @ 0x1b0 │ │ │ │ - vldr d7, [pc] @ 58b0 <__time64@plt+0x4034> │ │ │ │ + vldr d7, [pc] @ 60a0 <__time64@plt+0x48e8> │ │ │ │ vmov.u16 r6, d4[2] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ vldrle s30, [r9, #-64] @ 0xffffffc0 │ │ │ │ - blvc 40f1c <__time64@plt+0x3f6a0> │ │ │ │ - blpl e40f40 <__time64@plt+0xe3f6c4> │ │ │ │ - blvs 1812e4 <__time64@plt+0x17fa68> │ │ │ │ - bleq 11c138c <__time64@plt+0x11bfb10> │ │ │ │ - mrc 7, 6, APSR_nzcv, cr6, cr11, {7} │ │ │ │ - blvc 1041394 <__time64@plt+0x103fb18> │ │ │ │ - blvs 413b4 <__time64@plt+0x3fb38> │ │ │ │ - blvc 1c11b8 <__time64@plt+0x1bf93c> │ │ │ │ - blvs c80f5c <__time64@plt+0xc7f6e0> │ │ │ │ - blvc 1c1180 <__time64@plt+0x1bf904> │ │ │ │ - blvs 40f44 <__time64@plt+0x3f6c8> │ │ │ │ - blvc 12011c4 <__time64@plt+0x11ff948> │ │ │ │ - blvc 40f0c <__time64@plt+0x3f690> │ │ │ │ - blvc 40f50 <__time64@plt+0x3f6d4> │ │ │ │ - blvs b80f74 <__time64@plt+0xb7f6f8> │ │ │ │ - blvc ff1c13cc <__time64@plt+0xff1bfb50> │ │ │ │ - blx 4414c4 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<__time64@plt+0x4a60> │ │ │ │ vdiv.f64 d5, d7, d22 │ │ │ │ vmov.f64 d6, #5 @ 0x40280000 2.625 │ │ │ │ @ instruction: 0xf7fb0b46 │ │ │ │ - mrc 14, 5, lr, cr0, cr2, {5} │ │ │ │ + @ instruction: 0xeeb0ea58 │ │ │ │ vrintx.f64 d7, d0 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ - vldr d7, [pc, #24] @ 5940 <__time64@plt+0x40c4> │ │ │ │ + vldr d7, [pc, #24] @ 6130 <__time64@plt+0x4978> │ │ │ │ vmov.32 d7[1], r6 │ │ │ │ vldr d7, [r7, #24] │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7] │ │ │ │ - vldr d7, [pc] @ 5940 <__time64@plt+0x40c4> │ │ │ │ + vldr d7, [pc] @ 6130 <__time64@plt+0x4978> │ │ │ │ vmov.32 r6, d4[1] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ vstrle s30, [r8, #-64] @ 0xffffffc0 │ │ │ │ - blvc 40fac <__time64@plt+0x3f730> │ │ │ │ - blvs 540fd0 <__time64@plt+0x53f754> │ │ │ │ - blvc 11c1234 <__time64@plt+0x11bf9b8> │ │ │ │ - blvc 40f78 <__time64@plt+0x3f6fc> │ │ │ │ + blvc 4179c <__time64@plt+0x3ffe4> │ │ │ │ + blvs 5417c0 <__time64@plt+0x540008> │ │ │ │ + blvc 11c1a24 <__time64@plt+0x11c026c> │ │ │ │ + blvc 41768 <__time64@plt+0x3ffb0> │ │ │ │ ldc 0, cr14, [r7, #64] @ 0x40 │ │ │ │ - vldr d7, [pc] @ 5964 <__time64@plt+0x40e8> │ │ │ │ + vldr d7, [pc] @ 6154 <__time64@plt+0x499c> │ │ │ │ vmov.32 r6, d4[1] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ stmdale r7, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ - blvc 40fd0 <__time64@plt+0x3f754> │ │ │ │ - blvs 300ff4 <__time64@plt+0x2ff778> │ │ │ │ - blvc 1c1258 <__time64@plt+0x1bf9dc> │ │ │ │ - blvc 40f9c <__time64@plt+0x3f720> │ │ │ │ + blvc 417c0 <__time64@plt+0x40008> │ │ │ │ + blvs 3017e4 <__time64@plt+0x30002c> │ │ │ │ + blvc 1c1a48 <__time64@plt+0x1c0290> │ │ │ │ + blvc 4178c <__time64@plt+0x3ffd4> │ │ │ │ movwcs lr, #2519 @ 0x9d7 │ │ │ │ - blcs 600a94 <__time64@plt+0x5ff218> │ │ │ │ - bleq 120144c <__time64@plt+0x11ffbd0> │ │ │ │ + blcs 601284 <__time64@plt+0x5ffacc> │ │ │ │ + bleq 1201c3c <__time64@plt+0x1200484> │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ @ instruction: 0xffffffff │ │ │ │ svcvc 0x00efffff │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ @ instruction: 0x401921fb │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdgt r2, [r9], -fp │ │ │ │ stc 5, cr11, [sp, #-512]! @ 0xfffffe00 │ │ │ │ adclt r8, sl, r2, lsl #22 │ │ │ │ mvnsvs sl, r0, lsl #30 │ │ │ │ - bleq 140fe0 <__time64@plt+0x13f764> │ │ │ │ - blne c0fe4 <__time64@plt+0xbf768> │ │ │ │ - blcs 40fe8 <__time64@plt+0x3f76c> │ │ │ │ + bleq 1417d0 <__time64@plt+0x140018> │ │ │ │ + blne c17d4 <__time64@plt+0xc001c> │ │ │ │ + blcs 417d8 <__time64@plt+0x40020> │ │ │ │ @ instruction: 0xed9369fb │ │ │ │ - vldr d7, [pc, #16] @ 59e4 <__time64@plt+0x4168> │ │ │ │ + vldr d7, [pc, #16] @ 61d4 <__time64@plt+0x4a1c> │ │ │ │ vmov.32 r6, d23[1] │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmibvs fp!, {r3, r5, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 41030 <__time64@plt+0x3f7b4> │ │ │ │ - bleq 12014a8 <__time64@plt+0x11ffc2c> │ │ │ │ - mcr 7, 4, pc, cr10, cr11, {7} @ │ │ │ │ - bleq 9c100c <__time64@plt+0x9bf790> │ │ │ │ - blvc 9c1050 <__time64@plt+0x9bf7d4> │ │ │ │ - blvc 201294 <__time64@plt+0x1ffa18> │ │ │ │ - blvc 941018 <__time64@plt+0x93f79c> │ │ │ │ + blvc 41820 <__time64@plt+0x40068> │ │ │ │ + bleq 1201c98 <__time64@plt+0x12004e0> │ │ │ │ + b c441c8 <__time64@plt+0xc42a10> │ │ │ │ + bleq 9c17fc <__time64@plt+0x9c0044> │ │ │ │ + blvc 9c1840 <__time64@plt+0x9c0088> │ │ │ │ + blvc 201a84 <__time64@plt+0x2002cc> │ │ │ │ + blvc 941808 <__time64@plt+0x940050> │ │ │ │ @ instruction: 0xed9369fb │ │ │ │ vmov.f64 d7, #0 @ 0x40000000 2.0 │ │ │ │ @ instruction: 0xf7fb0b47 │ │ │ │ - stc 15, cr14, [r7, #216] @ 0xd8 │ │ │ │ + vstr s28, [r7, #880] @ 0x370 │ │ │ │ vldr d0, [r7, #136] @ 0x88 │ │ │ │ vldr d5, [r7, #152] @ 0x98 │ │ │ │ vdiv.f64 d6, d5, d18 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #128] @ 0x80 │ │ │ │ vmul.f64 d7, d7, d2 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #120] @ 0x78 │ │ │ │ vmul.f64 d7, d7, d0 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #112] @ 0x70 │ │ │ │ - vldr d7, [pc, #144] @ 5acc <__time64@plt+0x4250> │ │ │ │ + vldr d7, [pc, #144] @ 62bc <__time64@plt+0x4b04> │ │ │ │ vmul.f64 d6, d23, d4 │ │ │ │ vmov.f64 d7, #118 @ 0x3fb00000 1.375 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ @ instruction: 0xf7fb0b47 │ │ │ │ - cdp 14, 11, cr14, cr0, cr10, {3} │ │ │ │ + @ instruction: 0xeeb0ea10 │ │ │ │ vldr d5, [r7, #256] @ 0x100 │ │ │ │ vdiv.f64 d6, d6, d24 │ │ │ │ vstr d7, [r7, #20] │ │ │ │ vldr d7, [r7, #104] @ 0x68 │ │ │ │ - vldr d7, [pc, #160] @ 5b08 <__time64@plt+0x428c> │ │ │ │ + vldr d7, [pc, #160] @ 62f8 <__time64@plt+0x4b40> │ │ │ │ vmov.16 d7[3], r6 │ │ │ │ vldr d8, [r7, #24] │ │ │ │ - vldr d7, [pc, #144] @ 5b04 <__time64@plt+0x4288> │ │ │ │ + vldr d7, [pc, #144] @ 62f4 <__time64@plt+0x4b3c> │ │ │ │ vmov.16 d7[3], r6 │ │ │ │ vmov.f64 d7, #118 @ 0x3fb00000 1.375 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vrintx.f64 d7, d7 │ │ │ │ vmov.f64 d1, #8 @ 0x40400000 3.0 │ │ │ │ @ instruction: 0xf7fb0b47 │ │ │ │ - mrc 13, 5, lr, cr0, cr12, {5} │ │ │ │ + @ instruction: 0xeeb0e96e │ │ │ │ @ instruction: 0xee886b40 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vmov.32 r7, d7[1] │ │ │ │ vldr d5, [r7] │ │ │ │ vdup.32 d5, r6 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #88] @ 0x58 │ │ │ │ @@ -4250,15 +4807,15 @@ │ │ │ │ @ instruction: 0xeeb07b20 │ │ │ │ vmul.f64 d6, d7, d8 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ vmul.f64 d7, d6, d16 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ - vldr d7, [pc, #144] @ 5b90 <__time64@plt+0x4314> │ │ │ │ + vldr d7, [pc, #144] @ 6380 <__time64@plt+0x4bc8> │ │ │ │ @ instruction: 0xee275b53 │ │ │ │ vmov.f64 d7, #117 @ 0x3fa80000 1.3125000 │ │ │ │ vadd.f64 d5, d5, d0 │ │ │ │ vnmul.f64 d7, d6, d7 │ │ │ │ vldr d5, [r7, #28] │ │ │ │ @ instruction: 0xeeb17b28 │ │ │ │ vmul.f64 d6, d7, d8 │ │ │ │ @@ -4283,127 +4840,127 @@ │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmov.32 d5[1], r7 │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmov.32 d5[1], r7 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vstr d7, [r7, #284] @ 0x11c │ │ │ │ ldmibvs fp!, {r1, r2, r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvs 411d0 <__time64@plt+0x3f954> │ │ │ │ - blvc 3c11e4 <__time64@plt+0x3bf968> │ │ │ │ - blvc 201464 <__time64@plt+0x1ffbe8> │ │ │ │ - bleq 1201650 <__time64@plt+0x11ffdd4> │ │ │ │ + blvs 419c0 <__time64@plt+0x40208> │ │ │ │ + blvc 3c19d4 <__time64@plt+0x3c021c> │ │ │ │ + blvc 201c54 <__time64@plt+0x20049c> │ │ │ │ + bleq 1201e40 <__time64@plt+0x1200688> │ │ │ │ ldc2l 7, cr15, [r8, #1020] @ 0x3fc │ │ │ │ - blvc 1041658 <__time64@plt+0x103fddc> │ │ │ │ + blvc 1041e48 <__time64@plt+0x1040690> │ │ │ │ @ instruction: 0xed8369fb │ │ │ │ ldmibvs fp!, {r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 411f0 <__time64@plt+0x3f974> │ │ │ │ - bleq 1201668 <__time64@plt+0x11ffdec> │ │ │ │ - stc 7, cr15, [sl, #1004]! @ 0x3ec │ │ │ │ - bleq 3411cc <__time64@plt+0x33f950> │ │ │ │ - blvc 341210 <__time64@plt+0x33f994> │ │ │ │ - blvs 981234 <__time64@plt+0x97f9b8> │ │ │ │ - blvs 1c1458 <__time64@plt+0x1bfbdc> │ │ │ │ - blvc 34121c <__time64@plt+0x33f9a0> │ │ │ │ - blvc 20145c <__time64@plt+0x1ffbe0> │ │ │ │ - blvs 416a4 <__time64@plt+0x3fe28> │ │ │ │ - blvc 12014a4 <__time64@plt+0x11ffc28> │ │ │ │ - bleq 1201690 <__time64@plt+0x11ffe14> │ │ │ │ - stc 7, cr15, [r8, #1004]! @ 0x3ec │ │ │ │ - blpl 1041698 <__time64@plt+0x103fe1c> │ │ │ │ - blvs a41238 <__time64@plt+0xa3f9bc> │ │ │ │ - blvc 1815f8 <__time64@plt+0x17fd7c> │ │ │ │ - blvc 2c1200 <__time64@plt+0x2bf984> │ │ │ │ - blvs 41244 <__time64@plt+0x3f9c8> │ │ │ │ - blvc c1248 <__time64@plt+0xbf9cc> │ │ │ │ - blhi 201488 <__time64@plt+0x1ffc0c> │ │ │ │ + blvc 419e0 <__time64@plt+0x40228> │ │ │ │ + bleq 1201e58 <__time64@plt+0x12006a0> │ │ │ │ + ldmdb r0, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + bleq 3419bc <__time64@plt+0x340204> │ │ │ │ + blvc 341a00 <__time64@plt+0x340248> │ │ │ │ + blvs 981a24 <__time64@plt+0x98026c> │ │ │ │ + blvs 1c1c48 <__time64@plt+0x1c0490> │ │ │ │ + blvc 341a0c <__time64@plt+0x340254> │ │ │ │ + blvc 201c4c <__time64@plt+0x200494> │ │ │ │ + blvs 41e94 <__time64@plt+0x406dc> │ │ │ │ + blvc 1201c94 <__time64@plt+0x12004dc> │ │ │ │ + bleq 1201e80 <__time64@plt+0x12006c8> │ │ │ │ + stmdb lr, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blpl 1041e88 <__time64@plt+0x10406d0> │ │ │ │ + blvs a41a28 <__time64@plt+0xa40270> │ │ │ │ + blvc 181de8 <__time64@plt+0x180630> │ │ │ │ + blvc 2c19f0 <__time64@plt+0x2c0238> │ │ │ │ + blvs 41a34 <__time64@plt+0x4027c> │ │ │ │ + blvc c1a38 <__time64@plt+0xc0280> │ │ │ │ + blhi 201c78 <__time64@plt+0x2004c0> │ │ │ │ @ instruction: 0xed9369fb │ │ │ │ vmov.f64 d7, #0 @ 0x40000000 2.0 │ │ │ │ @ instruction: 0xf7fb0b47 │ │ │ │ - mrc 14, 5, lr, cr0, cr12, {1} │ │ │ │ + @ instruction: 0xeeb0e9e2 │ │ │ │ vldr d6, [r7, #256] @ 0x100 │ │ │ │ vmul.f64 d7, d6, d10 │ │ │ │ vdiv.f64 d6, d8, d7 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmibvs fp!, {r3, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvs c1264 <__time64@plt+0xbf9e8> │ │ │ │ - blvc 241278 <__time64@plt+0x23f9fc> │ │ │ │ - blvc 2014f8 <__time64@plt+0x1ffc7c> │ │ │ │ - bleq 12016e4 <__time64@plt+0x11ffe68> │ │ │ │ + blvs c1a54 <__time64@plt+0xc029c> │ │ │ │ + blvc 241a68 <__time64@plt+0x2402b0> │ │ │ │ + blvc 201ce8 <__time64@plt+0x200530> │ │ │ │ + bleq 1201ed4 <__time64@plt+0x120071c> │ │ │ │ mcr2 7, 1, pc, cr14, cr15, {7} @ │ │ │ │ - blvc 10416ec <__time64@plt+0x103fe70> │ │ │ │ + blvc 1041edc <__time64@plt+0x1040724> │ │ │ │ @ instruction: 0xed8369fb │ │ │ │ svclt 0x00007b02 │ │ │ │ ldrtmi r3, [sp], r8, lsr #15 │ │ │ │ - blhi c0f30 <__time64@plt+0xbf6b4> │ │ │ │ + blhi c1720 <__time64@plt+0xbff68> │ │ │ │ svclt 0x0000bd80 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ andmi r0, r0, r0 │ │ │ │ cmpmi r8, r6, lsr #9 │ │ │ │ vqrshrn.s64 d31, q12, #10 │ │ │ │ svccc 0x007b6b90 │ │ │ │ cdple 2, 1, cr1, cr10, cr13, {0} │ │ │ │ svccc 0x00efc928 │ │ │ │ stc 5, cr11, [sp, #-512]! @ 0xfffffe00 │ │ │ │ adcslt r8, r4, r2, lsl #22 │ │ │ │ mvnsvs sl, r0, lsl #30 │ │ │ │ - bleq 141288 <__time64@plt+0x13fa0c> │ │ │ │ - blne c128c <__time64@plt+0xbfa10> │ │ │ │ - blcs 41290 <__time64@plt+0x3fa14> │ │ │ │ + bleq 141a78 <__time64@plt+0x1402c0> │ │ │ │ + blne c1a7c <__time64@plt+0xc02c4> │ │ │ │ + blcs 41a80 <__time64@plt+0x402c8> │ │ │ │ bicge r6, r9, #1073741870 @ 0x4000002e │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ teqcs r2, #3260416 @ 0x31c000 │ │ │ │ @ instruction: 0xed9369fb │ │ │ │ - vldr d7, [pc, #16] @ 5c98 <__time64@plt+0x441c> │ │ │ │ + vldr d7, [pc, #16] @ 6488 <__time64@plt+0x4cd0> │ │ │ │ vmov.s16 r6, d23[2] │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmibvs fp!, {r4, r5, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 412e4 <__time64@plt+0x3fa68> │ │ │ │ - bleq 120175c <__time64@plt+0x11ffee0> │ │ │ │ - ldc 7, cr15, [r0, #-1004]! @ 0xfffffc14 │ │ │ │ - bleq bc12c0 <__time64@plt+0xbbfa44> │ │ │ │ - blvc bc1304 <__time64@plt+0xbbfa88> │ │ │ │ - blvc 201548 <__time64@plt+0x1ffccc> │ │ │ │ - blvc b412cc <__time64@plt+0xb3fa50> │ │ │ │ + blvc 41ad4 <__time64@plt+0x4031c> │ │ │ │ + bleq 1201f4c <__time64@plt+0x1200794> │ │ │ │ + ldm r6, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + bleq bc1ab0 <__time64@plt+0xbc02f8> │ │ │ │ + blvc bc1af4 <__time64@plt+0xbc033c> │ │ │ │ + blvc 201d38 <__time64@plt+0x200580> │ │ │ │ + blvc b41abc <__time64@plt+0xb40304> │ │ │ │ @ instruction: 0xed9369fb │ │ │ │ vmov.f64 d7, #0 @ 0x40000000 2.0 │ │ │ │ @ instruction: 0xf7fb0b47 │ │ │ │ - stc 13, cr14, [r7, #880] @ 0x370 │ │ │ │ + @ instruction: 0xed87e982 │ │ │ │ vldr d0, [r7, #168] @ 0xa8 │ │ │ │ vldr d5, [r7, #184] @ 0xb8 │ │ │ │ vdiv.f64 d6, d5, d26 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #160] @ 0xa0 │ │ │ │ vmul.f64 d7, d7, d2 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #152] @ 0x98 │ │ │ │ vmul.f64 d7, d7, d0 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #144] @ 0x90 │ │ │ │ - vldr d7, [pc, #176] @ 5da0 <__time64@plt+0x4524> │ │ │ │ + vldr d7, [pc, #176] @ 6590 <__time64@plt+0x4dd8> │ │ │ │ vmul.f64 d6, d23, d23 │ │ │ │ vmov.f64 d7, #118 @ 0x3fb00000 1.375 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ @ instruction: 0xf7fb0b47 │ │ │ │ - mrc 13, 5, lr, cr0, cr0, {0} │ │ │ │ + mrc 8, 5, lr, cr0, cr6, {5} │ │ │ │ vldr d5, [r7, #256] @ 0x100 │ │ │ │ vdup.16 d6, r6 │ │ │ │ vstr d7, [r7, #20] │ │ │ │ vldr d7, [r7, #136] @ 0x88 │ │ │ │ - vldr d7, [pc, #192] @ 5ddc <__time64@plt+0x4560> │ │ │ │ + vldr d7, [pc, #192] @ 65cc <__time64@plt+0x4e14> │ │ │ │ vmov.32 d23[1], r6 │ │ │ │ vldr d8, [r7, #24] │ │ │ │ - vldr d7, [pc, #176] @ 5dd8 <__time64@plt+0x455c> │ │ │ │ + vldr d7, [pc, #176] @ 65c8 <__time64@plt+0x4e10> │ │ │ │ vmov.32 d23[1], r6 │ │ │ │ vmov.f64 d7, #118 @ 0x3fb00000 1.375 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vrintx.f64 d7, d7 │ │ │ │ vmov.f64 d1, #8 @ 0x40400000 3.0 │ │ │ │ @ instruction: 0xf7fb0b47 │ │ │ │ - cdp 12, 11, cr14, cr0, cr2, {3} │ │ │ │ + mrc 8, 5, lr, cr0, cr4, {0} │ │ │ │ @ instruction: 0xee886b40 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ @ instruction: 0xeeb77b20 │ │ │ │ vldr d5, [r7] │ │ │ │ vdiv.f64 d6, d5, d16 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #120] @ 0x78 │ │ │ │ @@ -4423,15 +4980,15 @@ │ │ │ │ @ instruction: 0xeeb07b28 │ │ │ │ vmul.f64 d6, d7, d8 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ vmul.f64 d7, d6, d24 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d6, d7, d0 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ - vldr d7, [pc, #176] @ 5e64 <__time64@plt+0x45e8> │ │ │ │ + vldr d7, [pc, #176] @ 6654 <__time64@plt+0x4e9c> │ │ │ │ vmov.16 d7[3], r5 │ │ │ │ vmov.f64 d7, #117 @ 0x3fa80000 1.3125000 │ │ │ │ vadd.f64 d5, d5, d0 │ │ │ │ vnmul.f64 d7, d6, d7 │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmov.u16 r7, d1[2] │ │ │ │ vmul.f64 d6, d7, d8 │ │ │ │ @@ -4465,88 +5022,88 @@ │ │ │ │ @ instruction: 0xed9369fb │ │ │ │ vldr d6, [r7] │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ @ instruction: 0xf7ff0b47 │ │ │ │ mrc 12, 5, APSR_nzcv, cr0, cr9, {3} │ │ │ │ ldmibvs fp!, {r6, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 41468 <__time64@plt+0x3fbec> │ │ │ │ - blvs 5c14bc <__time64@plt+0x5bfc40> │ │ │ │ - blpl 41924 <__time64@plt+0x400a8> │ │ │ │ - blvc 181880 <__time64@plt+0x180004> │ │ │ │ - blvs 5414c8 <__time64@plt+0x53fc4c> │ │ │ │ - blvc 201748 <__time64@plt+0x1ffecc> │ │ │ │ - blvc 4c1490 <__time64@plt+0x4bfc14> │ │ │ │ - bleq 4c14d4 <__time64@plt+0x4bfc58> │ │ │ │ - mcrr 7, 15, pc, r2, cr11 @ │ │ │ │ - bleq 44149c <__time64@plt+0x43fc20> │ │ │ │ - bleq 4c14e0 <__time64@plt+0x4bfc64> │ │ │ │ - ldcl 7, cr15, [r6], #1004 @ 0x3ec │ │ │ │ - bleq 3c14a8 <__time64@plt+0x3bfc2c> │ │ │ │ + blvc 41c58 <__time64@plt+0x404a0> │ │ │ │ + blvs 5c1cac <__time64@plt+0x5c04f4> │ │ │ │ + blpl 42114 <__time64@plt+0x4095c> │ │ │ │ + blvc 182070 <__time64@plt+0x1808b8> │ │ │ │ + blvs 541cb8 <__time64@plt+0x540500> │ │ │ │ + blvc 201f38 <__time64@plt+0x200780> │ │ │ │ + blvc 4c1c80 <__time64@plt+0x4c04c8> │ │ │ │ + bleq 4c1cc4 <__time64@plt+0x4c050c> │ │ │ │ + svc 0x00e8f7fa │ │ │ │ + bleq 441c8c <__time64@plt+0x4404d4> │ │ │ │ + bleq 4c1cd0 <__time64@plt+0x4c0518> │ │ │ │ + ldm ip, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bleq 3c1c98 <__time64@plt+0x3c04e0> │ │ │ │ @ instruction: 0xed9369fb │ │ │ │ vmov.f64 d7, #0 @ 0x40000000 2.0 │ │ │ │ - @ instruction: 0xf7fb0b47 │ │ │ │ - stc 12, cr14, [r7, #208] @ 0xd0 │ │ │ │ + @ instruction: 0xf7fa0b47 │ │ │ │ + vstr , [r7, #360] @ 0x168 │ │ │ │ vldr d0, [r7, #48] @ 0x30 │ │ │ │ - vldr d7, [pc, #48] @ 5ed4 <__time64@plt+0x4658> │ │ │ │ + vldr d7, [pc, #48] @ 66c4 <__time64@plt+0x4f0c> │ │ │ │ vmov.16 d7[2], r6 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ vmul.f64 d7, d6, d12 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ - @ instruction: 0xf7fb0b47 │ │ │ │ - mrc 12, 5, lr, cr0, cr2, {1} │ │ │ │ + @ instruction: 0xf7fa0b47 │ │ │ │ + mrc 15, 5, lr, cr0, cr8, {6} │ │ │ │ vldr d5, [r7, #256] @ 0x100 │ │ │ │ vdup.16 d6, r6 │ │ │ │ vstr d7, [r7, #20] │ │ │ │ vldr d7, [r7, #40] @ 0x28 │ │ │ │ vldr d6, [r7] │ │ │ │ vmul.f64 d7, d6, d2 │ │ │ │ ldmibvs fp!, {r0, r1, r2, r8, r9, fp, pc}^ │ │ │ │ - blvc 41530 <__time64@plt+0x3fcb4> │ │ │ │ - bleq 12019a8 <__time64@plt+0x120012c> │ │ │ │ - stcl 7, cr15, [r4], {251} @ 0xfb │ │ │ │ - blvs 10419b0 <__time64@plt+0x1040134> │ │ │ │ - blvc 2c1550 <__time64@plt+0x2bfcd4> │ │ │ │ - blvs 201790 <__time64@plt+0x1fff14> │ │ │ │ - blvc 1c191c <__time64@plt+0x1c00a0> │ │ │ │ - blvc 24151c <__time64@plt+0x23fca0> │ │ │ │ - blvs 241560 <__time64@plt+0x23fce4> │ │ │ │ - blvc 441564 <__time64@plt+0x43fce8> │ │ │ │ - blhi 2017a4 <__time64@plt+0x1fff28> │ │ │ │ - blvc 5c156c <__time64@plt+0x5bfcf0> │ │ │ │ - blpl 419d4 <__time64@plt+0x40158> │ │ │ │ - blvs 181934 <__time64@plt+0x1800b8> │ │ │ │ - bleq 11c19dc <__time64@plt+0x11c0160> │ │ │ │ - stc 7, cr15, [sl], #1004 @ 0x3ec │ │ │ │ - blvc 10419e4 <__time64@plt+0x1040168> │ │ │ │ - blvs 201948 <__time64@plt+0x2000cc> │ │ │ │ - blpl 441588 <__time64@plt+0x43fd0c> │ │ │ │ - blvc 3c158c <__time64@plt+0x3bfd10> │ │ │ │ - blpl 2017c8 <__time64@plt+0x1fff4c> │ │ │ │ - blvc 3c1594 <__time64@plt+0x3bfd18> │ │ │ │ - blpl 2017d0 <__time64@plt+0x1fff54> │ │ │ │ - blvc 24159c <__time64@plt+0x23fd20> │ │ │ │ - blmi 2017d8 <__time64@plt+0x1fff5c> │ │ │ │ - blpl cc15a4 <__time64@plt+0xcbfd28> │ │ │ │ - blvc 18195c <__time64@plt+0x1800e0> │ │ │ │ - blvc 201828 <__time64@plt+0x1fffac> │ │ │ │ + blvc 41d20 <__time64@plt+0x40568> │ │ │ │ + bleq 1202198 <__time64@plt+0x12009e0> │ │ │ │ + stmda sl!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blvs 10421a0 <__time64@plt+0x10409e8> │ │ │ │ + blvc 2c1d40 <__time64@plt+0x2c0588> │ │ │ │ + blvs 201f80 <__time64@plt+0x2007c8> │ │ │ │ + blvc 1c210c <__time64@plt+0x1c0954> │ │ │ │ + blvc 241d0c <__time64@plt+0x240554> │ │ │ │ + blvs 241d50 <__time64@plt+0x240598> │ │ │ │ + blvc 441d54 <__time64@plt+0x44059c> │ │ │ │ + blhi 201f94 <__time64@plt+0x2007dc> │ │ │ │ + blvc 5c1d5c <__time64@plt+0x5c05a4> │ │ │ │ + blpl 421c4 <__time64@plt+0x40a0c> │ │ │ │ + blvs 182124 <__time64@plt+0x18096c> │ │ │ │ + bleq 11c21cc <__time64@plt+0x11c0a14> │ │ │ │ + ldmda r0, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blvc 10421d4 <__time64@plt+0x1040a1c> │ │ │ │ + blvs 202138 <__time64@plt+0x200980> │ │ │ │ + blpl 441d78 <__time64@plt+0x4405c0> │ │ │ │ + blvc 3c1d7c <__time64@plt+0x3c05c4> │ │ │ │ + blpl 201fb8 <__time64@plt+0x200800> │ │ │ │ + blvc 3c1d84 <__time64@plt+0x3c05cc> │ │ │ │ + blpl 201fc0 <__time64@plt+0x200808> │ │ │ │ + blvc 241d8c <__time64@plt+0x2405d4> │ │ │ │ + blmi 201fc8 <__time64@plt+0x200810> │ │ │ │ + blpl cc1d94 <__time64@plt+0xcc05dc> │ │ │ │ + blvc 18214c <__time64@plt+0x180994> │ │ │ │ + blvc 202018 <__time64@plt+0x200860> │ │ │ │ @ instruction: 0xed8369bb │ │ │ │ ldmibvs fp!, {r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvs c15a8 <__time64@plt+0xbfd2c> │ │ │ │ - blvc 2415bc <__time64@plt+0x23fd40> │ │ │ │ - blvc 20183c <__time64@plt+0x1fffc0> │ │ │ │ - bleq 1201a28 <__time64@plt+0x12001ac> │ │ │ │ + blvs c1d98 <__time64@plt+0xc05e0> │ │ │ │ + blvc 241dac <__time64@plt+0x2405f4> │ │ │ │ + blvc 20202c <__time64@plt+0x200874> │ │ │ │ + bleq 1202218 <__time64@plt+0x1200a60> │ │ │ │ stc2 7, cr15, [ip], {255} @ 0xff │ │ │ │ - blvc 1041a30 <__time64@plt+0x10401b4> │ │ │ │ + blvc 1042220 <__time64@plt+0x1040a68> │ │ │ │ @ instruction: 0xed8369fb │ │ │ │ svclt 0x00007b02 │ │ │ │ ssatmi r3, #30, r0, asr #15 │ │ │ │ - blhi c1274 <__time64@plt+0xbf9f8> │ │ │ │ + blhi c1a64 <__time64@plt+0xc02ac> │ │ │ │ svclt 0x0000bd80 │ │ │ │ andmi r0, r0, r0 │ │ │ │ cmpmi r8, r6, lsr #9 │ │ │ │ vqrshrn.s64 d31, q12, #10 │ │ │ │ svccc 0x007b6b90 │ │ │ │ cdple 2, 1, cr1, cr10, cr13, {0} │ │ │ │ svccc 0x00efc928 │ │ │ │ @@ -4556,188 +5113,188 @@ │ │ │ │ cmnvs r8, r4, lsl #30 │ │ │ │ stc 1, cr6, [r7, #228] @ 0xe4 │ │ │ │ rsbsvs r0, sl, r2, lsl #22 │ │ │ │ ldmib r3, {r0, r1, r6, r7, r8, r9, sp, pc}^ │ │ │ │ stmib r7, {r8, r9, sp}^ │ │ │ │ ldc 3, cr2, [r7, #64] @ 0x40 │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ - vldr d7, [pc, #796] @ 62e4 <__time64@plt+0x4a68> │ │ │ │ + vldr d7, [pc, #796] @ 6ad4 <__time64@plt+0x531c> │ │ │ │ vmov.u16 r6, d20[2] │ │ │ │ vneg.f64 d23, d6 │ │ │ │ stmdale r1!, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ - blvc c1634 <__time64@plt+0xbfdb8> │ │ │ │ - blvs febc1658 <__time64@plt+0xfebbfddc> │ │ │ │ - blvc ff1c1ab0 <__time64@plt+0xff1c0234> │ │ │ │ - blx 441ba8 <__time64@plt+0x44032c> │ │ │ │ + blvc c1e24 <__time64@plt+0xc066c> │ │ │ │ + blvs febc1e48 <__time64@plt+0xfebc0690> │ │ │ │ + blvc ff1c22a0 <__time64@plt+0xff1c0ae8> │ │ │ │ + blx 442398 <__time64@plt+0x440be0> │ │ │ │ movwcs fp, #8108 @ 0x1fac │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ movweq pc, #4227 @ 0x1083 @ │ │ │ │ - blcs 32b60 <__time64@plt+0x312e4> │ │ │ │ + blcs 33350 <__time64@plt+0x31b98> │ │ │ │ ldc 1, cr13, [r7, #64] @ 0x40 │ │ │ │ - vldr d7, [pc, #8] @ 6004 <__time64@plt+0x4788> │ │ │ │ + vldr d7, [pc, #8] @ 67f4 <__time64@plt+0x503c> │ │ │ │ @ instruction: 0xeeb46ba8 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ svclt 0x0094fa10 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0xf083b2db │ │ │ │ sbcslt r0, fp, #67108864 @ 0x4000000 │ │ │ │ andle r2, ip, r0, lsl #22 │ │ │ │ ldmib r7, {r0, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ stmib sp, {r1, r8, r9, sp}^ │ │ │ │ - blmi fea8ec24 <__time64@plt+0xfea8d3a8> │ │ │ │ + blmi fea8f414 <__time64@plt+0xfea8dc5c> │ │ │ │ @ instruction: 0x461a447b │ │ │ │ - @ instruction: 0xf7fb6978 │ │ │ │ - ldmdbvs fp!, {r3, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7fa6978 │ │ │ │ + ldmdbvs fp!, {r1, r2, r3, r5, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf04fe125 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ ldmdavs fp!, {r4, r8, r9, sp}^ │ │ │ │ vqdmulh.s d2, d0, d3 │ │ │ │ andge r8, r2, #16, 2 │ │ │ │ eorcc pc, r3, r2, asr r8 @ │ │ │ │ @ instruction: 0x4710441a │ │ │ │ andeq r0, r0, r1, lsl r0 │ │ │ │ andeq r0, r0, r7, lsl r1 │ │ │ │ muleq r0, sp, r1 │ │ │ │ andeq r0, r0, pc, ror #3 │ │ │ │ - blvc c16c0 <__time64@plt+0xbfe44> │ │ │ │ - blvc ff041b3c <__time64@plt+0xff0402c0> │ │ │ │ - blx 441c30 <__time64@plt+0x4403b4> │ │ │ │ + blvc c1eb0 <__time64@plt+0xc06f8> │ │ │ │ + blvc ff04232c <__time64@plt+0xff040b74> │ │ │ │ + blx 442420 <__time64@plt+0x440c68> │ │ │ │ movtcs sp, #60161 @ 0xeb01 │ │ │ │ cmpcs r3, #0 │ │ │ │ eorscc pc, pc, r7, lsl #17 │ │ │ │ - blvc c16d8 <__time64@plt+0xbfe5c> │ │ │ │ - blvc ff201b40 <__time64@plt+0xff2002c4> │ │ │ │ - blvs fe241700 <__time64@plt+0xfe23fe84> │ │ │ │ - blvs 1c1924 <__time64@plt+0x1c00a8> │ │ │ │ - blpl fe241708 <__time64@plt+0xfe23fe8c> │ │ │ │ - blvc 181aa8 <__time64@plt+0x18022c> │ │ │ │ - blvs fe241710 <__time64@plt+0xfe23fe94> │ │ │ │ - blvc 1c1934 <__time64@plt+0x1c00b8> │ │ │ │ - blvs 41b74 <__time64@plt+0x402f8> │ │ │ │ - blvc 1c197c <__time64@plt+0x1c0100> │ │ │ │ - blvc ff201c98 <__time64@plt+0xff20041c> │ │ │ │ - bcc fe441904 <__time64@plt+0xfe440088> │ │ │ │ + blvc c1ec8 <__time64@plt+0xc0710> │ │ │ │ + blvc ff202330 <__time64@plt+0xff200b78> │ │ │ │ + blvs fe241ef0 <__time64@plt+0xfe240738> │ │ │ │ + blvs 1c2114 <__time64@plt+0x1c095c> │ │ │ │ + blpl fe241ef8 <__time64@plt+0xfe240740> │ │ │ │ + blvc 182298 <__time64@plt+0x180ae0> │ │ │ │ + blvs fe241f00 <__time64@plt+0xfe240748> │ │ │ │ + blvc 1c2124 <__time64@plt+0x1c096c> │ │ │ │ + blvs 42364 <__time64@plt+0x40bac> │ │ │ │ + blvc 1c216c <__time64@plt+0x1c09b4> │ │ │ │ + blvc ff202488 <__time64@plt+0xff200cd0> │ │ │ │ + bcc fe4420f4 <__time64@plt+0xfe44093c> │ │ │ │ ldclvs 4, cr6, [sl], #1004 @ 0x3ec │ │ │ │ bicmi pc, r5, #1325400064 @ 0x4f000000 │ │ │ │ mvnne pc, #192, 4 │ │ │ │ stcle 2, cr4, [r4, #-616] @ 0xfffffd98 │ │ │ │ bicmi pc, r5, #1325400064 @ 0x4f000000 │ │ │ │ mvnne pc, #192, 4 │ │ │ │ ldclvs 4, cr6, [sl], #1004 @ 0x3ec │ │ │ │ mvnpl pc, #81788928 @ 0x4e00000 │ │ │ │ teqppl r4, #206569472 @ p-variant is OBSOLETE @ 0xc500000 │ │ │ │ movwne pc, #11139 @ 0x2b83 @ │ │ │ │ @ instruction: 0x17d31459 │ │ │ │ rscsvs r1, fp, #831488 @ 0xcb000 │ │ │ │ vpmin.s8 q11, q12, q13 │ │ │ │ @ instruction: 0xf6cf13c0 │ │ │ │ - blx a30ce <__time64@plt+0xa1852> │ │ │ │ + blx a38be <__time64@plt+0xa2106> │ │ │ │ ldclvs 3, cr15, [sl], #12 │ │ │ │ ldrbtvs r4, [fp], #1043 @ 0x413 │ │ │ │ @ instruction: 0xf6416cfa │ │ │ │ vrsra.s64 , , #64 │ │ │ │ - blx fe0daed2 <__time64@plt+0xfe0d9656> │ │ │ │ + blx fe0db6c2 <__time64@plt+0xfe0d9f0a> │ │ │ │ bicsne r1, r9, r2, lsl #6 │ │ │ │ - bne ff2cc04c <__time64@plt+0xff2ca7d0> │ │ │ │ + bne ff2cc83c <__time64@plt+0xff2cb084> │ │ │ │ ldmibvs sl!, {r0, r1, r3, r4, r5, r6, r7, r8, sp, lr}^ │ │ │ │ orrseq pc, r0, #81788928 @ 0x4e00000 │ │ │ │ mvnsvc pc, #217055232 @ 0xcf00000 │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldrmi r6, [r3], #-3322 @ 0xfffff306 │ │ │ │ ldmdbvs ip!, {r0, r1, r3, r4, r5, r6, r7, sl, sp, lr} │ │ │ │ vfma.f32 q11, q12, q13 │ │ │ │ vorr.i32 d21, #24320 @ 0x00005f00 │ │ │ │ - blx fe0cb0d2 <__time64@plt+0xfe0c9856> │ │ │ │ + blx fe0cb8c2 <__time64@plt+0xfe0ca10a> │ │ │ │ cmpne r9, r2, lsl #6 │ │ │ │ - bne ff24c078 <__time64@plt+0xff24a7fc> │ │ │ │ + bne ff24c868 <__time64@plt+0xff24b0b0> │ │ │ │ vfma.f32 q11, q12, q13 │ │ │ │ vorr.i32 d21, #24320 @ 0x00005f00 │ │ │ │ - blx fe0cb0e6 <__time64@plt+0xfe0c986a> │ │ │ │ + blx fe0cb8d6 <__time64@plt+0xfe0ca11e> │ │ │ │ cmpne r8, r2, lsl #6 │ │ │ │ - bne ff0cc08c <__time64@plt+0xff0ca810> │ │ │ │ - blx e2d6 <__time64@plt+0xca5a> │ │ │ │ - bne ff502d54 <__time64@plt+0xff5014d8> │ │ │ │ + bne ff0cc87c <__time64@plt+0xff0cb0c4> │ │ │ │ + blx eac6 <__time64@plt+0xd30e> │ │ │ │ + bne ff503544 <__time64@plt+0xff501d8c> │ │ │ │ mlascs pc, r7, r8, pc @ │ │ │ │ movwls r9, #8707 @ 0x2203 │ │ │ │ ldmibvs fp!, {r0, r8, ip, pc}^ │ │ │ │ - bvs ffeead58 <__time64@plt+0xffee94dc> │ │ │ │ + bvs ffeeb548 <__time64@plt+0xffee9d90> │ │ │ │ ldrbtmi r4, [sl], #-2653 @ 0xfffff5a3 │ │ │ │ ldmdbvs r8!, {r0, r5, r9, sl, lr}^ │ │ │ │ - b ffb44150 <__time64@plt+0xffb428d4> │ │ │ │ + mrc 7, 4, APSR_nzcv, cr2, cr10, {7} │ │ │ │ ldc 0, cr14, [r7, #552] @ 0x228 │ │ │ │ vmov.f64 d7, #82 @ 0x3e900000 0.2812500 │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ - blle 849b4 <__time64@plt+0x83138> │ │ │ │ + blle 851a4 <__time64@plt+0x839ec> │ │ │ │ and r2, r0, lr, asr #6 │ │ │ │ @ instruction: 0xf8872353 │ │ │ │ ldc 0, cr3, [r7, #252] @ 0xfc │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ - vldr d7, [pc, #796] @ 64a4 <__time64@plt+0x4c28> │ │ │ │ + vldr d7, [pc, #796] @ 6c94 <__time64@plt+0x54dc> │ │ │ │ vnmul.f64 d6, d7, d7 │ │ │ │ - vldr d6, [pc, #24] @ 61a8 <__time64@plt+0x492c> │ │ │ │ + vldr d6, [pc, #24] @ 6998 <__time64@plt+0x51e0> │ │ │ │ @ instruction: 0xee865b47 │ │ │ │ vldr d7, [r7, #20] │ │ │ │ vmov.32 r6, d6[1] │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #48] @ 0x30 │ │ │ │ vmov.f64 d23, #220 @ 0xbee00000 -0.4375000 │ │ │ │ vnmla.f64 d7, d23, d7 │ │ │ │ rscsvs r3, fp, #144, 20 @ 0x90000 │ │ │ │ @ instruction: 0xee076afb │ │ │ │ @ instruction: 0xeeb83a90 │ │ │ │ vldr d7, [r7, #924] @ 0x39c │ │ │ │ vadd.f64 d6, d6, d12 │ │ │ │ - vldr d7, [pc, #284] @ 62e0 <__time64@plt+0x4a64> │ │ │ │ + vldr d7, [pc, #284] @ 6ad0 <__time64@plt+0x5318> │ │ │ │ vmov.16 d7[2], r6 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmdbvs r9!, {r3, r8, r9, fp, ip, sp, lr} │ │ │ │ mlascc pc, r7, r8, pc @ │ │ │ │ ldmib r7, {r1, r8, r9, ip, pc}^ │ │ │ │ stmib sp, {r3, r8, r9, sp}^ │ │ │ │ - bvs ffecede0 <__time64@plt+0xffecd564> │ │ │ │ + bvs ffecf5d0 <__time64@plt+0xffecde18> │ │ │ │ ldrbtmi r4, [sl], #-2620 @ 0xfffff5c4 │ │ │ │ - @ instruction: 0xf7fb6978 │ │ │ │ - sub lr, r7, sl, lsr #21 │ │ │ │ - blvc c184c <__time64@plt+0xbffd0> │ │ │ │ - blvc ff041cc8 <__time64@plt+0xff04044c> │ │ │ │ - blx 441dbc <__time64@plt+0x440540> │ │ │ │ + @ instruction: 0xf7fa6978 │ │ │ │ + sub lr, r7, r0, asr lr │ │ │ │ + blvc c203c <__time64@plt+0xc0884> │ │ │ │ + blvc ff0424b8 <__time64@plt+0xff040d00> │ │ │ │ + blx 4425ac <__time64@plt+0x440df4> │ │ │ │ movtcs sp, #60161 @ 0xeb01 │ │ │ │ cmpcs r3, #0 │ │ │ │ eorscc pc, pc, r7, lsl #17 │ │ │ │ - blvc c1864 <__time64@plt+0xbffe8> │ │ │ │ - blvc ff201ccc <__time64@plt+0xff200450> │ │ │ │ - blvs 98188c <__time64@plt+0x980010> │ │ │ │ - blvs 1c1ab0 <__time64@plt+0x1c0234> │ │ │ │ - blpl 981894 <__time64@plt+0x980018> │ │ │ │ - blvc 181c34 <__time64@plt+0x1803b8> │ │ │ │ - blvc 34183c <__time64@plt+0x33ffc0> │ │ │ │ + blvc c2054 <__time64@plt+0xc089c> │ │ │ │ + blvc ff2024bc <__time64@plt+0xff200d04> │ │ │ │ + blvs 98207c <__time64@plt+0x9808c4> │ │ │ │ + blvs 1c22a0 <__time64@plt+0x1c0ae8> │ │ │ │ + blpl 982084 <__time64@plt+0x9808cc> │ │ │ │ + blvc 182424 <__time64@plt+0x180c6c> │ │ │ │ + blvc 34202c <__time64@plt+0x340874> │ │ │ │ @ instruction: 0xf8976939 │ │ │ │ movwls r3, #8255 @ 0x203f │ │ │ │ movwcs lr, #51671 @ 0xc9d7 │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ ldmdbvs r8!, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ - b fe044228 <__time64@plt+0xfe0429ac> │ │ │ │ + mcr 7, 1, pc, cr6, cr10, {7} @ │ │ │ │ ldmdbvs fp!, {r1, r2, r3, r4, sp, lr, pc} │ │ │ │ - blvc c18a0 <__time64@plt+0xc0024> │ │ │ │ - blvs 6018c4 <__time64@plt+0x600048> │ │ │ │ - blvs 1c1ae8 <__time64@plt+0x1c026c> │ │ │ │ - blpl 6018cc <__time64@plt+0x600050> │ │ │ │ - blvc 181c6c <__time64@plt+0x1803f0> │ │ │ │ - blvc 4188c <__time64@plt+0x40010> │ │ │ │ + blvc c2090 <__time64@plt+0xc08d8> │ │ │ │ + blvs 6020b4 <__time64@plt+0x6008fc> │ │ │ │ + blvs 1c22d8 <__time64@plt+0x1c0b20> │ │ │ │ + blpl 6020bc <__time64@plt+0x600904> │ │ │ │ + blvc 18245c <__time64@plt+0x180ca4> │ │ │ │ + blvc 4207c <__time64@plt+0x408c4> │ │ │ │ ldrbtmi r4, [sl], #-2592 @ 0xfffff5e0 │ │ │ │ ldmdbvs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - b 1b44250 <__time64@plt+0x1b429d4> │ │ │ │ + mrc 7, 0, APSR_nzcv, cr2, cr10, {7} │ │ │ │ ldmdavs fp!, {r1, r3, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [sl], #-2589 @ 0xfffff5e3 │ │ │ │ tstpne r9, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ ldrbtmi r4, [r8], #-2076 @ 0xfffff7e4 │ │ │ │ - blx 1bc426a <__time64@plt+0x1bc29ee> │ │ │ │ - b ff944268 <__time64@plt+0xff9429ec> │ │ │ │ + blx 1b44a5a <__time64@plt+0x1b432a2> │ │ │ │ + mcr 7, 4, pc, cr10, cr10, {7} @ │ │ │ │ @ instruction: 0x4618697b │ │ │ │ ssatmi r3, #30, r4, asr #14 │ │ │ │ svclt 0x0000bd90 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ @ instruction: 0xffffffff │ │ │ │ svcvc 0x00efffff │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ @@ -4750,108 +5307,108 @@ │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ tstpmi r5, r0, lsl #18 @ p-variant is OBSOLETE │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ strbtlt r1, [r8], #2895 @ 0xb4f │ │ │ │ svccc 0x004b4e81 │ │ │ │ - andeq r5, r0, r0, lsr #19 │ │ │ │ - andeq r5, r0, lr, ror #16 │ │ │ │ - strdeq r5, [r0], -lr │ │ │ │ - @ instruction: 0x000057ba │ │ │ │ - muleq r0, sl, r7 │ │ │ │ - muleq r0, r2, r7 │ │ │ │ - andeq r5, r0, sl, lsr #15 │ │ │ │ + andeq r5, r0, r4, lsr #18 │ │ │ │ + strdeq r5, [r0], -r2 │ │ │ │ + andeq r5, r0, r2, lsl #15 │ │ │ │ + andeq r5, r0, lr, lsr r7 │ │ │ │ + andeq r5, r0, lr, lsl r7 │ │ │ │ + andeq r5, r0, r6, lsl r7 │ │ │ │ + andeq r5, r0, lr, lsr #14 │ │ │ │ addslt fp, r8, r0, lsl #11 │ │ │ │ cmnvs r8, r4, lsl #30 │ │ │ │ stc 1, cr6, [r7, #228] @ 0xe4 │ │ │ │ rsbsvs r0, sl, r2, lsl #22 │ │ │ │ ldmib r3, {r1, r2, r3, r4, r5, r7, r8, r9, sp, pc}^ │ │ │ │ stmib r7, {r8, r9, sp}^ │ │ │ │ ldc 3, cr2, [r7, #64] @ 0x40 │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ - vldr d7, [pc, #796] @ 6628 <__time64@plt+0x4dac> │ │ │ │ + vldr d7, [pc, #796] @ 6e18 <__time64@plt+0x5660> │ │ │ │ @ instruction: 0xeeb46bae │ │ │ │ vneg.f64 d23, d6 │ │ │ │ stmdale r1!, {r4, r9, fp, ip, sp, lr, pc} │ │ │ │ - blvc c1978 <__time64@plt+0xc00fc> │ │ │ │ - blvs feb0199c <__time64@plt+0xfeb00120> │ │ │ │ - blvc ff1c1df4 <__time64@plt+0xff1c0578> │ │ │ │ - blx 441eec <__time64@plt+0x440670> │ │ │ │ + blvc c2168 <__time64@plt+0xc09b0> │ │ │ │ + blvs feb0218c <__time64@plt+0xfeb009d4> │ │ │ │ + blvc ff1c25e4 <__time64@plt+0xff1c0e2c> │ │ │ │ + blx 4426dc <__time64@plt+0x440f24> │ │ │ │ movwcs fp, #8108 @ 0x1fac │ │ │ │ sbcslt r2, fp, #0, 6 │ │ │ │ movweq pc, #4227 @ 0x1083 @ │ │ │ │ - blcs 32ea4 <__time64@plt+0x31628> │ │ │ │ + blcs 33694 <__time64@plt+0x31edc> │ │ │ │ ldc 1, cr13, [r7, #64] @ 0x40 │ │ │ │ - vldr d7, [pc, #8] @ 6348 <__time64@plt+0x4acc> │ │ │ │ + vldr d7, [pc, #8] @ 6b38 <__time64@plt+0x5380> │ │ │ │ @ instruction: 0xeeb46ba5 │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ svclt 0x0094fa10 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0xf083b2db │ │ │ │ sbcslt r0, fp, #67108864 @ 0x4000000 │ │ │ │ andle r2, ip, r0, lsl #22 │ │ │ │ ldmib r7, {r0, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ stmib sp, {r1, r8, r9, sp}^ │ │ │ │ - blmi fe94ef68 <__time64@plt+0xfe94d6ec> │ │ │ │ + blmi fe94f758 <__time64@plt+0xfe94dfa0> │ │ │ │ @ instruction: 0x461a447b │ │ │ │ - @ instruction: 0xf7fb6978 │ │ │ │ - ldmdbvs fp!, {r1, r2, r5, r6, r7, r8, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7fa6978 │ │ │ │ + ldmdbvs fp!, {r2, r3, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf04fe122 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r7, {r8, r9}^ │ │ │ │ ldmdavs fp!, {r4, r8, r9, sp}^ │ │ │ │ vqdmulh.s d2, d0, d3 │ │ │ │ andge r8, r2, #1073741827 @ 0x40000003 │ │ │ │ eorcc pc, r3, r2, asr r8 @ │ │ │ │ @ instruction: 0x4710441a │ │ │ │ andeq r0, r0, r1, lsl r0 │ │ │ │ andeq r0, r0, r1, lsl r1 │ │ │ │ muleq r0, r7, r1 │ │ │ │ andeq r0, r0, r9, ror #3 │ │ │ │ - blvc c1a04 <__time64@plt+0xc0188> │ │ │ │ - blvc ff041e80 <__time64@plt+0xff040604> │ │ │ │ - blx 441f74 <__time64@plt+0x4406f8> │ │ │ │ + blvc c21f4 <__time64@plt+0xc0a3c> │ │ │ │ + blvc ff042670 <__time64@plt+0xff040eb8> │ │ │ │ + blx 442764 <__time64@plt+0x440fac> │ │ │ │ movtcs sp, #23297 @ 0x5b01 │ │ │ │ cmpcs r7, #0 │ │ │ │ eorscc pc, pc, r7, lsl #17 │ │ │ │ - blvc c1a1c <__time64@plt+0xc01a0> │ │ │ │ - blvc ff201e84 <__time64@plt+0xff200608> │ │ │ │ - blvs fe181a44 <__time64@plt+0xfe1801c8> │ │ │ │ - blvs 1c1c68 <__time64@plt+0x1c03ec> │ │ │ │ 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<__time64@plt+0xec0bb8> │ │ │ │ + blvc 1c2594 <__time64@plt+0x1c0ddc> │ │ │ │ + blvc 242318 <__time64@plt+0x240b60> │ │ │ │ @ instruction: 0xf8976939 │ │ │ │ movwls r3, #8255 @ 0x203f │ │ │ │ movwcs lr, #35287 @ 0x89d7 │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ - bmi e6110c <__time64@plt+0xe5f890> │ │ │ │ + bmi e618fc <__time64@plt+0xe60144> │ │ │ │ ldmdbvs r8!, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - stmdb sl, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldc 7, cr15, [r0], #1000 @ 0x3e8 │ │ │ │ ldc 0, cr14, [r7, #284] @ 0x11c │ │ │ │ vmov.f64 d7, #82 @ 0x3e900000 0.2812500 │ │ │ │ vsqrt.f64 d23, d0 │ │ │ │ - blle 84d78 <__time64@plt+0x834fc> │ │ │ │ + blle 85568 <__time64@plt+0x83db0> │ │ │ │ and r2, r0, r5, asr #6 │ │ │ │ @ instruction: 0xf8872357 │ │ │ │ ldc 0, cr3, [r7, #252] @ 0xfc │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ - vldr d7, [pc, #796] @ 6868 <__time64@plt+0x4fec> │ │ │ │ + vldr d7, [pc, #796] @ 7058 <__time64@plt+0x58a0> │ │ │ │ vmul.f64 d6, d7, d20 │ │ │ │ - vldr d6, [pc, #24] @ 656c <__time64@plt+0x4cf0> │ │ │ │ + vldr d6, [pc, #24] @ 6d5c <__time64@plt+0x55a4> │ │ │ │ vdiv.f64 d5, d6, d16 │ │ │ │ vstr d7, [r7, #20] │ │ │ │ ldmdbvs r9!, {r2, r3, r8, r9, fp, ip, sp, lr} │ │ │ │ mlascc pc, r7, r8, pc @ │ │ │ │ ldmib r7, {r1, r8, r9, ip, pc}^ │ │ │ │ stmib sp, {r2, r3, r8, r9, sp}^ │ │ │ │ - blmi 98f170 <__time64@plt+0x98d8f4> │ │ │ │ + blmi 98f960 <__time64@plt+0x98e1a8> │ │ │ │ @ instruction: 0x461a447b │ │ │ │ - @ instruction: 0xf7fb6978 │ │ │ │ - ands lr, lr, r2, ror #17 │ │ │ │ + @ instruction: 0xf7fa6978 │ │ │ │ + ands lr, lr, r8, lsl #25 │ │ │ │ @ instruction: 0xed97693b │ │ │ │ - vldr d7, [pc, #8] @ 658c <__time64@plt+0x4d10> │ │ │ │ + vldr d7, [pc, #8] @ 6d7c <__time64@plt+0x55c4> │ │ │ │ vmov.32 d7[1], r6 │ │ │ │ - vldr d6, [pc, #24] @ 65a4 <__time64@plt+0x4d28> │ │ │ │ + vldr d6, [pc, #24] @ 6d94 <__time64@plt+0x55dc> │ │ │ │ vdup.32 d6, r5 │ │ │ │ vstr d7, [sp, #20] │ │ │ │ - bmi 765198 <__time64@plt+0x76391c> │ │ │ │ + bmi 765988 <__time64@plt+0x7641d0> │ │ │ │ @ instruction: 0x4619447a │ │ │ │ - @ instruction: 0xf7fb6978 │ │ │ │ - and lr, sl, lr, asr #17 │ │ │ │ - bmi 6a0794 <__time64@plt+0x69ef18> │ │ │ │ + @ instruction: 0xf7fa6978 │ │ │ │ + and lr, sl, r4, ror ip │ │ │ │ + bmi 6a0f84 <__time64@plt+0x69f7cc> │ │ │ │ vqshl.s8 q10, q13, q0 │ │ │ │ ldmdami r9, {r0, r1, r2, r3, r4, r5, r8, ip} │ │ │ │ @ instruction: 0xf7fc4478 │ │ │ │ - @ instruction: 0xf7fbf9cf │ │ │ │ - ldmdbvs fp!, {r1, r2, r6, r8, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7faf9cd │ │ │ │ + ldmdbvs fp!, {r2, r3, r5, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ smmlacc r0, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @ instruction: 0xffffffff │ │ │ │ svcvc 0x00efffff │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdgt r2, [r9], -fp │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ @@ -4954,91 +5511,91 @@ │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ andeq r0, r0, r0 │ │ │ │ tstpmi r5, r0, lsl #18 @ p-variant is OBSOLETE │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ strbtlt r1, [r8], #2895 @ 0xb4f │ │ │ │ svccc 0x004b4e81 │ │ │ │ - andeq r5, r0, ip, asr r6 │ │ │ │ - muleq r0, r2, r5 │ │ │ │ - andeq r5, r0, r0, asr #9 │ │ │ │ - andeq r5, r0, ip, ror r4 │ │ │ │ - andeq r5, r0, ip, asr r4 │ │ │ │ - andeq r5, r0, r4, asr r4 │ │ │ │ - andeq r5, r0, ip, ror #8 │ │ │ │ + andeq r5, r0, r0, ror #11 │ │ │ │ + andeq r5, r0, r6, lsl r5 │ │ │ │ + andeq r5, r0, r4, asr #8 │ │ │ │ + andeq r5, r0, r0, lsl #8 │ │ │ │ + andeq r5, r0, r0, ror #7 │ │ │ │ + ldrdeq r5, [r0], -r8 │ │ │ │ + strdeq r5, [r0], -r0 │ │ │ │ strdlt fp, [fp], r0 │ │ │ │ rscsvs sl, r8, r6, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r1, r2, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ ldmib r1, {r0, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmdavs ip!, {r1, r8}^ │ │ │ │ strmi lr, [r4, #-2516] @ 0xfffff62c │ │ │ │ strmi lr, [r4, #-2509] @ 0xfffff633 │ │ │ │ smlabteq r2, sp, r9, lr │ │ │ │ movwcs lr, #2509 @ 0x9cd │ │ │ │ ldrbtmi r4, [fp], #-2821 @ 0xfffff4fb │ │ │ │ @ instruction: 0x4631461a │ │ │ │ - @ instruction: 0xf7fb68f8 │ │ │ │ - svclt 0x0000e876 │ │ │ │ + @ instruction: 0xf7fa68f8 │ │ │ │ + svclt 0x0000ec1c │ │ │ │ ssatmi r3, #30, r4, lsl #14 │ │ │ │ svclt 0x0000bdf0 │ │ │ │ - strdeq r5, [r0], -lr │ │ │ │ + andeq r5, r0, r2, lsl #7 │ │ │ │ adcslt fp, sl, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r4, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr}^ │ │ │ │ - blvc 41cc0 <__time64@plt+0x40444> │ │ │ │ + blvc 424b0 <__time64@plt+0x40cf8> │ │ │ │ cmnpeq r4, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ mrc 8, 5, r6, cr0, cr10, {1} │ │ │ │ cmncs r3, r7, asr #22 │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r3, r7, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - blvc c1cd8 <__time64@plt+0xc045c> │ │ │ │ + blvc c24c8 <__time64@plt+0xc0d10> │ │ │ │ tstpeq r0, #-1073741823 @ p-variant is OBSOLETE @ 0xc0000001 │ │ │ │ mrc 8, 5, r6, cr0, cr10, {1} │ │ │ │ cmncs r3, r7, asr #22 │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ ldmvs r9!, {r0, r2, r5, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ ldmib r3, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf1072304 │ │ │ │ stmib sp, {r2, r4, r5, r6}^ │ │ │ │ @ instruction: 0xf1072302 │ │ │ │ movwls r0, #784 @ 0x310 │ │ │ │ - bmi 117ec4 <__time64@plt+0x116648> │ │ │ │ + bmi 1186b4 <__time64@plt+0x116efc> │ │ │ │ ldmvs r8!, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - ldmda lr!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bl ff944e98 <__time64@plt+0xff9436e0> │ │ │ │ ldrbcc fp, [r8, r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r5, r0, r4, lsr #7 │ │ │ │ + andeq r5, r0, r8, lsr #6 │ │ │ │ addslt fp, sl, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xa3bd6039 │ │ │ │ movwcs lr, #2515 @ 0x9d3 │ │ │ │ tstcs r4, #3260416 @ 0x31c000 │ │ │ │ ldmib r3, {r2, r3, r4, r5, r7, r8, r9, sp, pc}^ │ │ │ │ stmib r7, {r8, r9, sp}^ │ │ │ │ ldmdavs fp!, {r1, r4, r8, r9, sp}^ │ │ │ │ - blvs 41d3c <__time64@plt+0x404c0> │ │ │ │ + blvs 4252c <__time64@plt+0x40d74> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmul.f64 d7, d6, d0 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, sp, lr}^ │ │ │ │ - blpl c1d4c <__time64@plt+0xc04d0> │ │ │ │ + blpl c253c <__time64@plt+0xc0d84> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmul.f64 d7, d5, d2 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ - @ instruction: 0xf7fb0b47 │ │ │ │ - stc 8, cr14, [r7, #32] │ │ │ │ + @ instruction: 0xf7fa0b47 │ │ │ │ + vstr d14, [r7, #696] @ 0x2b8 │ │ │ │ ldmdavs fp!, {r4, r8, r9, fp}^ │ │ │ │ movwcs lr, #18899 @ 0x49d3 │ │ │ │ movwcs lr, #59847 @ 0xe9c7 │ │ │ │ - blvc 441d84 <__time64@plt+0x440508> │ │ │ │ - blvc 1042200 <__time64@plt+0x1040984> │ │ │ │ - blx 4422f4 <__time64@plt+0x440a78> │ │ │ │ + blvc 442574 <__time64@plt+0x440dbc> │ │ │ │ + blvc 10429f0 <__time64@plt+0x1041238> │ │ │ │ + blx 442ae4 <__time64@plt+0x44132c> │ │ │ │ ldc 1, cr13, [r7, #112] @ 0x70 │ │ │ │ vmov.f64 d7, #94 @ 0x3ef00000 0.4687500 │ │ │ │ vneg.f64 d23, d0 │ │ │ │ tstple r5, r0, lsl sl @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf04f6839 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r1, {r8, r9}^ │ │ │ │ @@ -5046,51 +5603,51 @@ │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #10689 @ 0x29c1 │ │ │ │ @ instruction: 0xf04f6839 │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ stmib r1, {r8, r9}^ │ │ │ │ tst fp, r4, lsl #6 │ │ │ │ - blvc 441dcc <__time64@plt+0x440550> │ │ │ │ - blvs 202010 <__time64@plt+0x200794> │ │ │ │ - blvc 3c1dd4 <__time64@plt+0x3c0558> │ │ │ │ - blvc 202018 <__time64@plt+0x20079c> │ │ │ │ - blvc 202058 <__time64@plt+0x2007dc> │ │ │ │ - bleq 1202244 <__time64@plt+0x12009c8> │ │ │ │ - svc 0x00cef7fa │ │ │ │ - blpl 104224c <__time64@plt+0x10409d0> │ │ │ │ - blvs 3c1dec <__time64@plt+0x3c0570> │ │ │ │ - blvc 1821ac <__time64@plt+0x180930> │ │ │ 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#336] @ 0x150 │ │ │ │ vldr d0, [r7, #24] │ │ │ │ - vldr d7, [pc, #96] @ 6834 <__time64@plt+0x4fb8> │ │ │ │ + vldr d7, [pc, #96] @ 7024 <__time64@plt+0x586c> │ │ │ │ vmov.16 d7[3], r6 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ vmov.32 d6[1], r7 │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vldr d5, [r7, #80] @ 0x50 │ │ │ │ vmov.32 d5[1], r7 │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmul.f64 d7, d5, d6 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ - vldr d7, [pc, #24] @ 6818 <__time64@plt+0x4f9c> │ │ │ │ + vldr d7, [pc, #24] @ 7008 <__time64@plt+0x5850> │ │ │ │ vnmul.f64 d5, d7, d29 │ │ │ │ vldr d5, [r7, #20] │ │ │ │ vmul.f64 d7, d5, d14 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ vldr d5, [r7, #72] @ 0x48 │ │ │ │ vmul.f64 d7, d5, d6 │ │ │ │ @@ -5102,28 +5659,28 @@ │ │ │ │ vldr d7, [r7, #16] │ │ │ │ vldr d6, [r7, #80] @ 0x50 │ │ │ │ vmul.f64 d7, d6, d8 │ │ │ │ vadd.f64 d7, d7, d7 │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vldr d6, [r7, #28] │ │ │ │ - vldr d7, [pc, #64] @ 6890 <__time64@plt+0x5014> │ │ │ │ + vldr d7, [pc, #64] @ 7080 <__time64@plt+0x58c8> │ │ │ │ @ instruction: 0xee275b57 │ │ │ │ vldr d5, [r7, #20] │ │ │ │ vmul.f64 d7, d5, d8 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vmov.32 r7, d7[1] │ │ │ │ vldr d5, [r7, #28] │ │ │ │ vmul.f64 d7, d5, d8 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ - vldr d7, [pc, #96] @ 68e4 <__time64@plt+0x5068> │ │ │ │ + vldr d7, [pc, #96] @ 70d4 <__time64@plt+0x591c> │ │ │ │ vnmul.f64 d5, d7, d12 │ │ │ │ vldr d5, [r7, #20] │ │ │ │ vmul.f64 d7, d5, d14 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vadd.f64 d7, d7, d7 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #8] │ │ │ │ @@ -5132,30 +5689,30 @@ │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #88] @ 0x58 │ │ │ │ vldr d6, [r7, #96] @ 0x60 │ │ │ │ vmov.32 r7, d6[1] │ │ │ │ vstr d7, [r7, #284] @ 0x11c │ │ │ │ vldr d7, [r7, #96] @ 0x60 │ │ │ │ vmov.32 r7, d0[1] │ │ │ │ - vldr d7, [pc, #796] @ 6be4 <__time64@plt+0x5368> │ │ │ │ + vldr d7, [pc, #796] @ 73d4 <__time64@plt+0x5c1c> │ │ │ │ vmov.u16 r6, d4[2] │ │ │ │ vsqrt.f64 d23, d6 │ │ │ │ @ instruction: 0xf73ffa10 │ │ │ │ ldc 15, cr10, [r7, #424] @ 0x1a8 │ │ │ │ - vldr d7, [pc, #96] @ 693c <__time64@plt+0x50c0> │ │ │ │ + vldr d7, [pc, #96] @ 712c <__time64@plt+0x5974> │ │ │ │ vmov.16 d7[2], r6 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #48] @ 0x30 │ │ │ │ vmov.32 d7[1], r7 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ @ instruction: 0xf7fa0b47 │ │ │ │ - mrc 15, 5, lr, cr0, cr4, {0} │ │ │ │ - vldr d7, [pc, #256] @ 6a04 <__time64@plt+0x5188> │ │ │ │ + @ instruction: 0xeeb0eaba │ │ │ │ + vldr d7, [pc, #256] @ 71f4 <__time64@plt+0x5a3c> │ │ │ │ vmul.f64 d6, d7, d26 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ vldr d7, [r7, #40] @ 0x28 │ │ │ │ vldr d6, [r7, #56] @ 0x38 │ │ │ │ vadd.f64 d7, d6, d12 │ │ │ │ vldr d6, [r7, #284] @ 0x11c │ │ │ │ vldr d5, [r7, #56] @ 0x38 │ │ │ │ @@ -5167,108 +5724,108 @@ │ │ │ │ vldr d5, [r7, #284] @ 0x11c │ │ │ │ vldr d4, [r7, #64] @ 0x40 │ │ │ │ vadd.f64 d7, d4, d10 │ │ │ │ vnmul.f64 d7, d5, d7 │ │ │ │ vadd.f64 d7, d6, d7 │ │ │ │ vmov.f64 d7, #7 @ 0x40380000 2.875 │ │ │ │ @ instruction: 0xf7fa0b47 │ │ │ │ - cdp 14, 11, cr14, cr0, cr10, {7} │ │ │ │ + @ instruction: 0xeeb0ea90 │ │ │ │ ldmdavs fp!, {r6, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 141f68 <__time64@plt+0x1406ec> │ │ │ │ - blvc 2c1fbc <__time64@plt+0x2c0740> │ │ │ │ - blvs 641fe0 <__time64@plt+0x640764> │ │ │ │ - blvc 1c2204 <__time64@plt+0x1c0988> │ │ │ │ - blvs 341fc8 <__time64@plt+0x34074c> │ │ │ │ - blpl 202388 <__time64@plt+0x200b0c> │ │ │ │ - bleq 1182434 <__time64@plt+0x1180bb8> │ │ │ │ - mrc 7, 7, APSR_nzcv, cr10, cr10, {7} │ │ │ │ - blvc 104243c <__time64@plt+0x1040bc0> │ │ │ │ + blvc 142758 <__time64@plt+0x140fa0> │ │ │ │ + blvc 2c27ac <__time64@plt+0x2c0ff4> │ │ │ │ + blvs 6427d0 <__time64@plt+0x641018> │ │ │ │ + blvc 1c29f4 <__time64@plt+0x1c123c> │ │ │ │ + blvs 3427b8 <__time64@plt+0x341000> │ │ │ │ + blpl 202b78 <__time64@plt+0x2013c0> │ │ │ │ + bleq 1182c24 <__time64@plt+0x118146c> │ │ │ │ + b fe845150 <__time64@plt+0xfe843998> │ │ │ │ + blvc 1042c2c <__time64@plt+0x1041474> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ ldmdavs fp!, {r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc c1fd4 <__time64@plt+0xc0758> │ │ │ │ + blvc c27c4 <__time64@plt+0xc100c> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d6, #0 @ 0x40000000 2.0 │ │ │ │ vmov.f64 d1, d6 │ │ │ │ @ instruction: 0xf7fa0b47 │ │ │ │ - cdp 15, 11, cr14, cr0, cr2, {3} │ │ │ │ + vmov.f64 d14, #8 @ 0x40400000 3.0 │ │ │ │ ldmdavs fp!, {r6, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc c1fb0 <__time64@plt+0xc0734> │ │ │ │ + blvc c27a0 <__time64@plt+0xc0fe8> │ │ │ │ ldrtmi r3, [sp], r8, ror #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ andmi r0, r0, r0 │ │ │ │ cmpmi r8, r6, lsr #9 │ │ │ │ ldrne sp, [fp], #-2641 @ 0xfffff5af │ │ │ │ cmpmi r8, r4, asr #31 │ │ │ │ ldmdb fp, {r4, r5, r6, r8, r9, fp} │ │ │ │ mcrcc 14, 0, r7, cr0, cr15, {0} │ │ │ │ cdple 2, 1, cr1, cr10, cr13, {0} │ │ │ │ svccc 0x00efc928 │ │ │ │ - stcmi 8, cr11, [pc], #-512 @ 67d0 <__time64@plt+0x4f54> │ │ │ │ + stcmi 8, cr11, [pc], #-512 @ 6fc0 <__time64@plt+0x5808> │ │ │ │ sbcmi r7, r2, #868 @ 0x364 │ │ │ │ vfmacs.f64 d22, d26, d7 │ │ │ │ sbcmi r6, r2, #37 @ 0x25 │ │ │ │ stc 5, cr11, [sp, #-512]! @ 0xfffffe00 │ │ │ │ addlt r8, sl, r2, lsl #22 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - blvc 4203c <__time64@plt+0x407c0> │ │ │ │ - bleq 12024b4 <__time64@plt+0x1200c38> │ │ │ │ - mcr 7, 4, pc, cr4, cr10, {7} @ │ │ │ │ - bleq 242018 <__time64@plt+0x24079c> │ │ │ │ + blvc 4282c <__time64@plt+0x41074> │ │ │ │ + bleq 1202ca4 <__time64@plt+0x12014ec> │ │ │ │ + b ac51d0 <__time64@plt+0xac3a18> │ │ │ │ + bleq 242808 <__time64@plt+0x241050> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d7, #0 @ 0x40000000 2.0 │ │ │ │ @ instruction: 0xf7fa0b47 │ │ │ │ - stc 15, cr14, [r7, #216] @ 0xd8 │ │ │ │ + vstr s28, [r7, #880] @ 0x370 │ │ │ │ vldr d0, [r7, #24] │ │ │ │ - vldr d7, [pc, #32] @ 6a34 <__time64@plt+0x51b8> │ │ │ │ + vldr d7, [pc, #32] @ 7224 <__time64@plt+0x5a6c> │ │ │ │ vmov.16 d7[2], r6 │ │ │ │ vldr d6, [r7, #24] │ │ │ │ vmul.f64 d7, d6, d8 │ │ │ │ vmov.f64 d7, #119 @ 0x3fb80000 1.4375000 │ │ │ │ vadd.f64 d6, d6, d0 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ @ instruction: 0xf7fa0b47 │ │ │ │ - mrc 14, 5, lr, cr0, cr10, {3} │ │ │ │ - vldr d6, [pc, #256] @ 6b38 <__time64@plt+0x52bc> │ │ │ │ + @ instruction: 0xeeb0ea20 │ │ │ │ + vldr d6, [pc, #256] @ 7328 <__time64@plt+0x5b70> │ │ │ │ vdiv.f64 d5, d5, d25 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmdavs fp!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ - blvc 142094 <__time64@plt+0x140818> │ │ │ │ - blvs 1420a8 <__time64@plt+0x14082c> │ │ │ │ - blvc 202328 <__time64@plt+0x200aac> │ │ │ │ - blvc c2070 <__time64@plt+0xc07f4> │ │ │ │ - blvs c20b4 <__time64@plt+0xc0838> │ │ │ │ - blvc 1c20b8 <__time64@plt+0x1c083c> │ │ │ │ - blhi 2022f8 <__time64@plt+0x200a7c> │ │ │ │ + blvc 142884 <__time64@plt+0x1410cc> │ │ │ │ + blvs 142898 <__time64@plt+0x1410e0> │ │ │ │ + blvc 202b18 <__time64@plt+0x201360> │ │ │ │ + blvc c2860 <__time64@plt+0xc10a8> │ │ │ │ + blvs c28a4 <__time64@plt+0xc10ec> │ │ │ │ + blvc 1c28a8 <__time64@plt+0x1c10f0> │ │ │ │ + blhi 202ae8 <__time64@plt+0x201330> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ @ instruction: 0xf7fa0b47 │ │ │ │ - cdp 15, 11, cr14, cr0, cr4, {0} │ │ │ │ + @ instruction: 0xeeb0eaaa │ │ │ │ vnmul.f64 d7, d8, d0 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 42088 <__time64@plt+0x4080c> │ │ │ │ - blvs c20dc <__time64@plt+0xc0860> │ │ │ │ - blvc 1c20e0 <__time64@plt+0x1c0864> │ │ │ │ - blhi 202320 <__time64@plt+0x200aa4> │ │ │ │ + blvc 42878 <__time64@plt+0x410c0> │ │ │ │ + blvs c28cc <__time64@plt+0xc1114> │ │ │ │ + blvc 1c28d0 <__time64@plt+0x1c1118> │ │ │ │ + blhi 202b10 <__time64@plt+0x201358> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d7, #2 @ 0x40100000 2.250 │ │ │ │ @ instruction: 0xf7fa0b47 │ │ │ │ - mrc 14, 5, lr, cr0, cr6, {1} │ │ │ │ + @ instruction: 0xeeb0e9dc │ │ │ │ vnmul.f64 d7, d8, d0 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc c20b0 <__time64@plt+0xc0834> │ │ │ │ - blvc 142104 <__time64@plt+0x140888> │ │ │ │ - blvs 3c2128 <__time64@plt+0x3c08ac> │ │ │ │ - blvs 1c234c <__time64@plt+0x1c0ad0> │ │ │ │ + blvc c28a0 <__time64@plt+0xc10e8> │ │ │ │ + blvc 1428f4 <__time64@plt+0x14113c> │ │ │ │ + blvs 3c2918 <__time64@plt+0x3c1160> │ │ │ │ + blvs 1c2b3c <__time64@plt+0x1c1384> │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vadd.f64 d7, d6, d4 │ │ │ │ vldr d6, [r7, #28] │ │ │ │ vmul.f64 d7, d6, d8 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 1420d4 <__time64@plt+0x140858> │ │ │ │ + blvc 1428c4 <__time64@plt+0x14110c> │ │ │ │ strcc fp, [r8, -r0, lsl #30]! │ │ │ │ ldc 6, cr4, [sp], #756 @ 0x2f4 │ │ │ │ vstrlt d8, [r0, #8] │ │ │ │ vqrshrn.s64 d31, q12, #10 │ │ │ │ svccc 0x007b6b90 │ │ │ │ andmi r0, r0, r0 │ │ │ │ cmpmi r8, r6, lsr #9 │ │ │ │ @@ -5278,70 +5835,70 @@ │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ andle r2, r6, r0, lsl #22 │ │ │ │ andcs r6, r0, #8060928 @ 0x7b0000 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r7, sp, lr}^ │ │ │ │ ldrsbtvs r6, [fp], #139 @ 0x8b │ │ │ │ ldmdavs fp!, {r0, r4, sp, lr, pc}^ │ │ │ │ - blcs 20b7c <__time64@plt+0x1f300> │ │ │ │ + blcs 2136c <__time64@plt+0x1fbb4> │ │ │ │ ldmdavs fp!, {r0, r1, r2, ip, lr, pc}^ │ │ │ │ mrrcne 8, 1, r6, r9, cr11 │ │ │ │ andsvs r6, r1, sl, ror r8 │ │ │ │ rscsvs r7, fp, fp, lsl r8 │ │ │ │ ldmdavs fp!, {r0, r2, sp, lr, pc}^ │ │ │ │ @ instruction: 0x4618685b │ │ │ │ - mrc 7, 0, APSR_nzcv, cr10, cr10, {7} │ │ │ │ + stmib r0, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldmvs fp!, {r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @ instruction: 0xb082b5b0 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blmi fe8cff44 <__time64@plt+0xfe8ce6c8> │ │ │ │ + blmi fe8d0734 <__time64@plt+0xfe8cef7c> │ │ │ │ andcs r4, r0, #2063597568 @ 0x7b000000 │ │ │ │ teq r3, sl, lsl r0 │ │ │ │ andle r2, r8, r0, lsl #26 │ │ │ │ vqdmull.s q9, d0, d0 │ │ │ │ strtmi r8, [fp], -r2, lsr #2 │ │ │ │ - blcs 55764 <__time64@plt+0x53ee8> │ │ │ │ + blcs 55f54 <__time64@plt+0x5479c> │ │ │ │ tstphi sp, r0, lsl #4 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7fae0c0 │ │ │ │ - strmi lr, [r3], -r2, asr #27 │ │ │ │ + strmi lr, [r3], -r8, ror #18 │ │ │ │ @ instruction: 0x4623681a │ │ │ │ ldrmi r0, [r3], #-91 @ 0xffffffa5 │ │ │ │ vst2.8 {d8-d9}, [r3 :64], fp │ │ │ │ - blcs 1b778 <__time64@plt+0x19efc> │ │ │ │ + blcs 1bf68 <__time64@plt+0x1a7b0> │ │ │ │ tstphi fp, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ - ldc 7, cr15, [r4, #1000]! @ 0x3e8 │ │ │ │ + ldmdb sl, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldmdavs sl, {r0, r1, r9, sl, lr} │ │ │ │ subseq r4, fp, r3, lsr #12 │ │ │ │ ldmdahi fp, {r0, r1, r4, sl, lr} │ │ │ │ movwvs pc, #1027 @ 0x403 @ │ │ │ │ andle r2, ip, r0, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2959 @ 0xfffff471 │ │ │ │ mrrcne 8, 1, r6, r9, cr11 │ │ │ │ ldrbtmi r4, [sl], #-2702 @ 0xfffff572 │ │ │ │ rsclt r6, r1, #17 │ │ │ │ ldrbtmi r4, [sl], #-2701 @ 0xfffff573 │ │ │ │ strcs r5, [r2, #-1233] @ 0xfffffb2f │ │ │ │ stccs 1, cr14, [lr], #-8 │ │ │ │ - blmi fe2fafe4 <__time64@plt+0xfe2f9768> │ │ │ │ + blmi fe2fb7d4 <__time64@plt+0xfe2fa01c> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bmi fe28dd20 <__time64@plt+0xfe28c4a4> │ │ │ │ + bmi fe28e510 <__time64@plt+0xfe28cd58> │ │ │ │ andsvs r4, r1, sl, ror r4 │ │ │ │ - bmi fe273748 <__time64@plt+0xfe271ecc> │ │ │ │ + bmi fe273f38 <__time64@plt+0xfe272780> │ │ │ │ ldrbpl r4, [r1], #1146 @ 0x47a │ │ │ │ rscs r2, r3, r3, lsl #10 │ │ │ │ - blmi fe1f3758 <__time64@plt+0xfe1f1edc> │ │ │ │ + blmi fe1f3f48 <__time64@plt+0xfe1f2790> │ │ │ │ andsvc r4, sl, fp, ror r4 │ │ │ │ ldrbtmi r4, [fp], #-2950 @ 0xfffff47a │ │ │ │ subsvc r2, sl, r0, lsl #4 │ │ │ │ rsbsle r2, r5, sp, lsr #24 │ │ │ │ - blle 1f51c98 <__time64@plt+0x1f5041c> │ │ │ │ + blle 1f52488 <__time64@plt+0x1f50cd0> │ │ │ │ ldclle 12, cr2, [fp], #-476 @ 0xfffffe24 │ │ │ │ - blle 1e51d00 <__time64@plt+0x1e50484> │ │ │ │ + blle 1e524f0 <__time64@plt+0x1e50d38> │ │ │ │ movteq pc, #20900 @ 0x51a4 @ │ │ │ │ ldmdale r5!, {r1, r4, r5, r8, r9, fp, sp}^ │ │ │ │ @ instruction: 0xf852a202 │ │ │ │ ldrmi r3, [sl], #-35 @ 0xffffffdd │ │ │ │ svclt 0x00004710 │ │ │ │ ldrdeq r0, [r0], -r5 │ │ │ │ andeq r0, r0, r1, ror #1 │ │ │ │ @@ -5396,94 +5953,94 @@ │ │ │ │ ldrdeq r0, [r0], -sp │ │ │ │ rsbs r2, sl, r3, lsl #6 │ │ │ │ rsbs r2, r8, r4, lsl #6 │ │ │ │ rsbs r2, r6, r6, lsl #6 │ │ │ │ rsbs r2, r4, r5, lsl #6 │ │ │ │ rsbs r2, r2, r7, lsl #6 │ │ │ │ rsbs r2, r0, r0, lsl #6 │ │ │ │ - stc 7, cr15, [r0, #-1000] @ 0xfffffc18 │ │ │ │ + stmia r6!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldmdavs sl, {r0, r1, r9, sl, lr} │ │ │ │ subseq r4, fp, r3, lsr #12 │ │ │ │ ldmdahi fp, {r0, r1, r4, sl, lr} │ │ │ │ movwpl pc, #1027 @ 0x403 @ │ │ │ │ tstle r9, r0, lsl #22 │ │ │ │ andsle r2, r7, sp, lsr #24 │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - strmi lr, [r3], -ip, asr #26 │ │ │ │ + @ instruction: 0x4603e8f2 │ │ │ │ andsle r2, r1, lr, asr #22 │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - strmi lr, [r3], -r6, asr #26 │ │ │ │ + strmi lr, [r3], -ip, ror #17 │ │ │ │ andle r2, fp, r3, asr fp │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - strmi lr, [r3], -r0, asr #26 │ │ │ │ + strmi lr, [r3], -r6, ror #17 │ │ │ │ andle r2, r5, r7, asr fp │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - @ instruction: 0x4603ed3a │ │ │ │ + strmi lr, [r3], -r0, ror #17 │ │ │ │ @ instruction: 0xd1252b45 │ │ │ │ ldrbtmi r4, [fp], #-2864 @ 0xfffff4d0 │ │ │ │ - bmi c20da4 <__time64@plt+0xc1f528> │ │ │ │ + bmi c21594 <__time64@plt+0xc1fddc> │ │ │ │ tstcs r0, sl, ror r4 │ │ │ │ ldmdavs fp!, {r0, r4, r6, r7, sl, ip, lr}^ │ │ │ │ ldmdavs fp!, {r2, r3, r4, r6, r7, sp, lr}^ │ │ │ │ addsvs r2, sl, r1, lsl #4 │ │ │ │ tstle sl, r2, lsl #26 │ │ │ │ ldrbtmi r4, [fp], #-2859 @ 0xfffff4d5 │ │ │ │ @ instruction: 0xf7fa4618 │ │ │ │ - strmi lr, [r2], -r2, asr #26 │ │ │ │ + strmi lr, [r2], -r8, ror #17 │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ movwcs r6, #8218 @ 0x201a │ │ │ │ - blmi a3ee28 <__time64@plt+0xa3d5ac> │ │ │ │ + blmi a3f618 <__time64@plt+0xa3de60> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - stcl 7, cr15, [r0, #-1000]! @ 0xfffffc18 │ │ │ │ - blvc 1042830 <__time64@plt+0x1040fb4> │ │ │ │ + stmdb r6, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blvc 1043020 <__time64@plt+0x1041868> │ │ │ │ ldrbtmi r4, [fp], #-2853 @ 0xfffff4db │ │ │ │ - blvc 42384 <__time64@plt+0x40b08> │ │ │ │ + blvc 42b74 <__time64@plt+0x413bc> │ │ │ │ eor r2, r4, r1, lsl #6 │ │ │ │ tstle r0, lr, lsr #24 │ │ │ │ - blmi 890190 <__time64@plt+0x88e914> │ │ │ │ + blmi 890980 <__time64@plt+0x88f1c8> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bmi 84def0 <__time64@plt+0x84c674> │ │ │ │ + bmi 84e6e0 <__time64@plt+0x84cf28> │ │ │ │ andsvs r4, r1, sl, ror r4 │ │ │ │ - bmi 833918 <__time64@plt+0x83209c> │ │ │ │ + bmi 834108 <__time64@plt+0x832950> │ │ │ │ ldrbpl r4, [r1], #1146 @ 0x47a │ │ │ │ - blmi 7fedcc <__time64@plt+0x7fd550> │ │ │ │ + blmi 7ff5bc <__time64@plt+0x7fde04> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bmi 78df08 <__time64@plt+0x78c68c> │ │ │ │ + bmi 78e6f8 <__time64@plt+0x78cf40> │ │ │ │ andsvs r4, r1, sl, ror r4 │ │ │ │ - bmi 773930 <__time64@plt+0x7720b4> │ │ │ │ + bmi 774120 <__time64@plt+0x772968> │ │ │ │ ldrbpl r4, [r1], #1146 @ 0x47a │ │ │ │ svclt 0x0000e000 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4604fe99 │ │ │ │ svccc 0x00fff1b4 │ │ │ │ mcrge 4, 6, pc, cr4, cr15, {3} @ │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ ldrtmi r3, [sp], r8, lsl #14 │ │ │ │ svclt 0x0000bdb0 │ │ │ │ - andeq r8, r0, ip, lsl r0 │ │ │ │ - andeq r7, r0, sl, asr #31 │ │ │ │ - andeq r7, r0, r2, asr #31 │ │ │ │ - @ instruction: 0x00007eba │ │ │ │ - andeq r7, r0, ip, lsr #31 │ │ │ │ - andeq r7, r0, r4, lsr #31 │ │ │ │ - muleq r0, ip, lr │ │ │ │ - muleq r0, r0, lr │ │ │ │ - andeq r7, r0, sl, lsl #29 │ │ │ │ - andeq r7, r0, lr, lsr #28 │ │ │ │ - andeq r7, r0, r8, lsr #26 │ │ │ │ - andeq r7, r0, r2, lsl sp │ │ │ │ - strdeq r7, [r0], -lr │ │ │ │ - strdeq r7, [r0], -ip │ │ │ │ - andeq r7, r0, r6, ror #25 │ │ │ │ - ldrdeq r7, [r0], -ip │ │ │ │ - ldrdeq r7, [r0], -r4 │ │ │ │ - andeq r7, r0, ip, asr #25 │ │ │ │ - andeq r7, r0, r4, asr #27 │ │ │ │ - @ instruction: 0x00007dbc │ │ │ │ - @ instruction: 0x00007cb4 │ │ │ │ + muleq r0, ip, r8 │ │ │ │ + andeq r8, r0, sl, asr #16 │ │ │ │ + andeq r8, r0, r2, asr #16 │ │ │ │ + andeq r8, r0, sl, lsr r7 │ │ │ │ + andeq r8, r0, ip, lsr #16 │ │ │ │ + andeq r8, r0, r4, lsr #16 │ │ │ │ + andeq r8, r0, ip, lsl r7 │ │ │ │ + andeq r8, r0, r0, lsl r7 │ │ │ │ + andeq r8, r0, sl, lsl #14 │ │ │ │ + andeq r8, r0, lr, lsr #13 │ │ │ │ + andeq r8, r0, r8, lsr #11 │ │ │ │ + muleq r0, r2, r5 │ │ │ │ + andeq r8, r0, lr, ror r5 │ │ │ │ + andeq r8, r0, ip, ror r5 │ │ │ │ + andeq r8, r0, r6, ror #10 │ │ │ │ + andeq r8, r0, ip, asr r6 │ │ │ │ + andeq r8, r0, r4, asr r6 │ │ │ │ + andeq r8, r0, ip, asr #10 │ │ │ │ + andeq r8, r0, r4, asr #12 │ │ │ │ + andeq r8, r0, ip, lsr r6 │ │ │ │ + andeq r8, r0, r4, lsr r5 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ rscsvs pc, r8, r3, lsl #29 │ │ │ │ @ instruction: 0x461868fb │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ @@ -5495,63 +6052,63 @@ │ │ │ │ @ instruction: 0xf04f0200 │ │ │ │ @ instruction: 0xf6c30300 │ │ │ │ stmib r7, {r4, r5, r6, r7, r8, r9, ip, sp, lr}^ │ │ │ │ movwcs r2, #4868 @ 0x1304 │ │ │ │ ldmdavs r8!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ @ instruction: 0xffdcf7ff │ │ │ │ ldmvs fp!, {r3, r4, r5, r7, sp, lr} │ │ │ │ - blcs 115a78 <__time64@plt+0x1141fc> │ │ │ │ + blcs 116268 <__time64@plt+0x114ab0> │ │ │ │ andge sp, r2, #7274496 @ 0x6f0000 │ │ │ │ eorcc pc, r3, r2, asr r8 @ │ │ │ │ @ instruction: 0x4710441a │ │ │ │ andeq r0, r0, pc, lsl #1 │ │ │ │ andeq r0, r0, r9, lsr r0 │ │ │ │ ldrdeq r0, [r0], -r7 │ │ │ │ andeq r0, r0, r5, lsl r0 │ │ │ │ andeq r0, r0, r5, lsr #32 │ │ │ │ ldrbtmi r4, [r9], #-2359 @ 0xfffff6c9 │ │ │ │ movwcs lr, #27095 @ 0x69d7 │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ subs r2, pc, r0, lsl #6 │ │ │ │ - blvc 1c2504 <__time64@plt+0x1c0c88> │ │ │ │ - blvc 1202970 <__time64@plt+0x12010f4> │ │ │ │ + blvc 1c2cf4 <__time64@plt+0x1c153c> │ │ │ │ + blvc 1203160 <__time64@plt+0x12019a8> │ │ │ │ ldrbtmi r4, [fp], #-2866 @ 0xfffff4ce │ │ │ │ - blvc 424c0 <__time64@plt+0x40c44> │ │ │ │ + blvc 42cb0 <__time64@plt+0x414f8> │ │ │ │ subs r2, r5, r0, lsl #6 │ │ │ │ - blcs 212a8 <__time64@plt+0x1fa2c> │ │ │ │ - blmi bfaf50 <__time64@plt+0xbf96d4> │ │ │ │ + blcs 21a98 <__time64@plt+0x202e0> │ │ │ │ + blmi bfb740 <__time64@plt+0xbf9f88> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bcc fe4426e4 <__time64@plt+0xfe440e68> │ │ │ │ - blpl ffa029ac <__time64@plt+0xffa01130> │ │ │ │ - blvs 14252c <__time64@plt+0x140cb0> │ │ │ │ - blvc 1c28e8 <__time64@plt+0x1c106c> │ │ │ │ - blvs 1c2534 <__time64@plt+0x1c0cb8> │ │ │ │ - blvc 2027b4 <__time64@plt+0x200f38> │ │ │ │ - blvc 1c24fc <__time64@plt+0x1c0c80> │ │ │ │ - blvc 142540 <__time64@plt+0x140cc4> │ │ │ │ - blvs 882564 <__time64@plt+0x880ce8> │ │ │ │ - blvc 1c2788 <__time64@plt+0x1c0f0c> │ │ │ │ - blvc 14250c <__time64@plt+0x140c90> │ │ │ │ + bcc fe442ed4 <__time64@plt+0xfe44171c> │ │ │ │ + blpl ffa0319c <__time64@plt+0xffa019e4> │ │ │ │ + blvs 142d1c <__time64@plt+0x141564> │ │ │ │ + blvc 1c30d8 <__time64@plt+0x1c1920> │ │ │ │ + blvs 1c2d24 <__time64@plt+0x1c156c> │ │ │ │ + blvc 202fa4 <__time64@plt+0x2017ec> │ │ │ │ + blvc 1c2cec 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#24] │ │ │ │ ldmdavs r8!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ @ instruction: 0xff70f7ff │ │ │ │ ldmvs fp!, {r3, r4, r5, r7, sp, lr} │ │ │ │ tstle r9, r3, lsl #22 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @@ -5560,237 +6117,237 @@ │ │ │ │ strd r3, [r3], -pc @ │ │ │ │ str fp, [r6, r0, lsl #30] │ │ │ │ str fp, [r4, r0, lsl #30] │ │ │ │ @ instruction: 0x37204618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ - andeq r7, r0, r2, asr #23 │ │ │ │ - andeq r7, r0, sl, lsr #23 │ │ │ │ - muleq r0, r8, fp │ │ │ │ - andeq r7, r0, r4, asr #22 │ │ │ │ + andeq r8, r0, r2, asr #8 │ │ │ │ + andeq r8, r0, sl, lsr #8 │ │ │ │ + andeq r8, r0, r8, lsl r4 │ │ │ │ + andeq r8, r0, r4, asr #7 │ │ │ │ addlt fp, r8, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #27079 @ 0x69c7 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ mvnsvc pc, #204472320 @ 0xc300000 │ │ │ │ movwcs lr, #18887 @ 0x49c7 │ │ │ │ adcsvs r2, fp, r1, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603ff39 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ - blcs 195bc0 <__time64@plt+0x194344> │ │ │ │ + blcs 1963b0 <__time64@plt+0x194bf8> │ │ │ │ andge sp, r2, #7798784 @ 0x770000 │ │ │ │ eorcc pc, r3, r2, asr r8 @ │ │ │ │ @ instruction: 0x4710441a │ │ │ │ muleq r0, fp, r0 │ │ │ │ andeq r0, r0, r1, asr #32 │ │ │ │ andeq r0, r0, r7, ror #1 │ │ │ │ andeq r0, r0, r7, ror #1 │ │ │ │ andeq r0, r0, r7, ror #1 │ │ │ │ andeq r0, r0, sp, lsl r0 │ │ │ │ andeq r0, r0, sp, lsr #32 │ │ │ │ ldrbtmi r4, [r9], #-2361 @ 0xfffff6c7 │ │ │ │ movwcs lr, #27095 @ 0x69d7 │ │ │ │ movwcs lr, #2497 @ 0x9c1 │ │ │ │ rsb r2, r3, r0, lsl #6 │ │ │ │ - blvc 1c2654 <__time64@plt+0x1c0dd8> │ │ │ │ - blvc 1202ac0 <__time64@plt+0x1201244> │ │ │ │ + blvc 1c2e44 <__time64@plt+0x1c168c> │ │ │ │ + blvc 12032b0 <__time64@plt+0x1201af8> │ │ │ │ ldrbtmi r4, [fp], #-2868 @ 0xfffff4cc │ │ │ │ - blvc 42610 <__time64@plt+0x40d94> │ │ │ │ + blvc 42e00 <__time64@plt+0x41648> │ │ │ │ subs r2, r9, r0, lsl #6 │ │ │ │ - blcs 212f8 <__time64@plt+0x1fa7c> │ │ │ │ - blmi c7b0a8 <__time64@plt+0xc7982c> │ │ │ │ + blcs 21ae8 <__time64@plt+0x20330> │ │ │ │ + blmi c7b898 <__time64@plt+0xc7a0e0> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - bcc fe442834 <__time64@plt+0xfe440fb8> │ │ │ │ - blpl ffa02afc <__time64@plt+0xffa01280> │ │ │ │ - blvs 14267c <__time64@plt+0x140e00> │ │ │ │ - blvc 1c2a38 <__time64@plt+0x1c11bc> │ │ │ │ - blvs 1c2684 <__time64@plt+0x1c0e08> │ │ │ │ - blvc 202904 <__time64@plt+0x201088> │ │ │ │ - blvc 1c264c <__time64@plt+0x1c0dd0> │ │ │ │ - blvc 142690 <__time64@plt+0x140e14> │ │ │ │ - blvs 9026b4 <__time64@plt+0x900e38> │ │ │ │ - blvc 1c28d8 <__time64@plt+0x1c105c> │ │ │ │ - blvc 14265c <__time64@plt+0x140de0> │ │ │ │ + bcc fe443024 <__time64@plt+0xfe44186c> │ │ │ │ + blpl ffa032ec <__time64@plt+0xffa01b34> │ │ │ │ + blvs 142e6c <__time64@plt+0x1416b4> │ │ │ │ + blvc 1c3228 <__time64@plt+0x1c1a70> │ │ │ │ + blvs 1c2e74 <__time64@plt+0x1c16bc> │ │ │ │ + blvc 2030f4 <__time64@plt+0x20193c> │ │ │ │ + blvc 1c2e3c <__time64@plt+0x1c1684> │ │ │ │ + blvc 142e80 <__time64@plt+0x1416c8> │ │ │ │ + blvs 902ea4 <__time64@plt+0x9016ec> │ │ │ │ + blvc 1c30c8 <__time64@plt+0x1c1910> │ │ │ │ + blvc 142e4c <__time64@plt+0x141694> │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -pc, ror #29 │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ teqle r1, r3, lsl #22 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r7, ror #29 │ │ │ │ strd r6, [fp], -fp @ │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ movwcs lr, #44 @ 0x2c │ │ │ │ - blmi 71f354 <__time64@plt+0x71dad8> │ │ │ │ + blmi 71fb44 <__time64@plt+0x71e38c> │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ vldr d5, [r7] │ │ │ │ vdiv.f64 d6, d5, d4 │ │ │ │ vldr d7, [r7, #24] │ │ │ │ vadd.f64 d6, d6, d6 │ │ │ │ vstr d7, [r7, #28] │ │ │ │ vldr d7, [r7, #24] │ │ │ │ - vldr d7, [pc, #16] @ 7098 <__time64@plt+0x581c> │ │ │ │ + vldr d7, [pc, #16] @ 7888 <__time64@plt+0x60d0> │ │ │ │ vmul.f64 d6, d7, d15 │ │ │ │ vstr d7, [r7, #24] │ │ │ │ ldmdavs r8!, {r2, r8, r9, fp, ip, sp, lr}^ │ │ │ │ mcr2 7, 6, pc, cr6, cr15, {7} @ │ │ │ │ rscsvs r4, fp, r3, lsl #12 │ │ │ │ - blcs e148c <__time64@plt+0xdfc10> │ │ │ │ + blcs e1c7c <__time64@plt+0xe04c4> │ │ │ │ ldmdavs r8!, {r1, r3, r8, ip, lr, pc}^ │ │ │ │ mrc2 7, 5, pc, cr14, cr15, {7} │ │ │ │ rscsvs r4, fp, r3, lsl #12 │ │ │ │ @ instruction: 0xf04fe004 │ │ │ │ strd r3, [r3], -pc @ │ │ │ │ ldrb fp, [lr, -r0, lsl #30]! │ │ │ │ ldrb fp, [ip, -r0, lsl #30]! │ │ │ │ @ instruction: 0x37204618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ andeq r0, r0, r0 │ │ │ │ submi r0, lr, r0 │ │ │ │ - andeq r7, r0, r2, ror sl │ │ │ │ - andeq r7, r0, sl, asr sl │ │ │ │ - andeq r7, r0, r8, asr #20 │ │ │ │ - strdeq r7, [r0], -r0 │ │ │ │ + strdeq r8, [r0], -r2 │ │ │ │ + ldrdeq r8, [r0], -sl │ │ │ │ + andeq r8, r0, r8, asr #5 │ │ │ │ + andeq r8, r0, r0, ror r2 │ │ │ │ adclt fp, r8, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ movwcs r6, #187 @ 0xbb │ │ │ │ @ instruction: 0xf107613b │ │ │ │ ldrmi r0, [r8], -r8, lsl #6 │ │ │ │ mcr2 7, 5, pc, cr3, cr15, {7} @ │ │ │ │ - blcs 18908 <__time64@plt+0x1708c> │ │ │ │ + blcs 190f8 <__time64@plt+0x17940> │ │ │ │ movwcs sp, #1 │ │ │ │ - blmi 4bf158 <__time64@plt+0x4bd8dc> │ │ │ │ + blmi 4bf948 <__time64@plt+0x4be190> │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ - vldr d7, [pc] @ 710c <__time64@plt+0x5890> │ │ │ │ + vldr d7, [pc] @ 78fc <__time64@plt+0x6144> │ │ │ │ vmul.f64 d6, d7, d12 │ │ │ │ - vldr d6, [pc, #24] @ 712c <__time64@plt+0x58b0> │ │ │ │ + vldr d6, [pc, #24] @ 791c <__time64@plt+0x6164> │ │ │ │ vdiv.f64 d5, d6, d12 │ │ │ │ ldmdavs fp!, {r0, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 4272c <__time64@plt+0x40eb0> │ │ │ │ + blvc 42f1c <__time64@plt+0x41764> │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, 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vmul.f64 d6, d7, d11 │ │ │ │ - vldr d6, [pc, #24] @ 71a0 <__time64@plt+0x5924> │ │ │ │ + vldr d6, [pc, #24] @ 7990 <__time64@plt+0x61d8> │ │ │ │ vdiv.f64 d5, d6, d11 │ │ │ │ ldmdavs fp!, {r0, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 427a0 <__time64@plt+0x40f24> │ │ │ │ + blvc 42f90 <__time64@plt+0x417d8> │ │ │ │ ldmdavc fp, {r0, r1, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ svclt 0x000c2b00 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ @ instruction: 0x4618b2db │ │ │ │ ldrtmi r3, [sp], r0, lsr #15 │ │ │ │ svclt 0x0000bd80 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ - andeq r7, r0, r0, ror #17 │ │ │ │ + andeq r8, r0, r0, ror #2 │ │ │ │ adclt fp, r8, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ movwcs r6, #187 @ 0xbb │ │ │ │ @ instruction: 0xf107613b │ │ │ │ ldrmi r0, [r8], -r8, lsl #6 │ │ │ │ mrc2 7, 1, pc, cr1, cr15, {7} │ │ │ │ - blcs 189ec <__time64@plt+0x17170> │ │ │ │ + blcs 191dc <__time64@plt+0x17a24> │ │ │ │ movwcs sp, #1 │ │ │ │ - blmi 7ff2a4 <__time64@plt+0x7fda28> │ │ │ │ + blmi 7ffa94 <__time64@plt+0x7fe2dc> │ │ │ │ ldc 4, cr4, [r3, #492] @ 0x1ec │ │ │ │ - vldr d7, [pc] @ 71f0 <__time64@plt+0x5974> │ │ │ │ + vldr d7, [pc] @ 79e0 <__time64@plt+0x6228> │ │ │ │ vmov.32 d7[1], r6 │ │ │ │ - vldr d6, [pc, #24] @ 7210 <__time64@plt+0x5994> │ │ │ │ + vldr d6, [pc, #24] @ 7a00 <__time64@plt+0x6248> │ │ │ │ vdup.32 d6, r5 │ │ │ │ ldmdavs fp!, {r0, r2, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 42810 <__time64@plt+0x40f94> │ │ │ │ + blvc 43000 <__time64@plt+0x41848> │ │ │ │ movweq pc, #33031 @ 0x8107 @ │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ @ instruction: 0x4603febb │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ ands r2, r6, r0, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2835 @ 0xfffff4ed │ │ │ │ - blvc 4286c <__time64@plt+0x40ff0> │ │ │ │ - blvs 3428a0 <__time64@plt+0x341024> │ │ │ │ - blvs 1c2ac4 <__time64@plt+0x1c1248> │ │ │ │ - blpl 3428a8 <__time64@plt+0x34102c> │ │ │ │ - blvc 182c48 <__time64@plt+0x1813cc> │ │ │ │ + blvc 4305c <__time64@plt+0x418a4> │ │ │ │ + blvs 343090 <__time64@plt+0x3418d8> │ │ │ │ + blvs 1c32b4 <__time64@plt+0x1c1afc> │ │ │ │ + blpl 343098 <__time64@plt+0x3418e0> │ │ │ │ + blvc 183438 <__time64@plt+0x181c80> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ ldmdavs r9!, {r1, r8, r9, fp, ip, sp, lr} │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ movwcs lr, #18881 @ 0x49c1 │ │ │ │ @ instruction: 0x461868bb │ │ │ │ ldrtmi r3, [sp], r0, lsr #15 │ │ │ │ svclt 0x0000bd80 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ strdmi r2, [r9], -fp │ │ │ │ andeq r0, r0, r0 │ │ │ │ rsbmi r8, r6, r0 │ │ │ │ - andeq r7, r0, r0, ror r8 │ │ │ │ - andeq r7, r0, lr, lsr r8 │ │ │ │ + strdeq r8, [r0], -r0 │ │ │ │ + strheq r8, [r0], -lr │ │ │ │ addlt fp, lr, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, sp, lr} │ │ │ │ - mrrc2 7, 15, pc, r4, cr10 @ │ │ │ │ + @ instruction: 0xf88cf7fa │ │ │ │ ldc 8, cr6, [r3, #492] @ 0x1ec │ │ │ │ vmov.f64 d7, #18 @ 0x40900000 4.5 │ │ │ │ vmov.f64 d7, d7 │ │ │ │ tstcs r3, r7, asr #22 │ │ │ │ @ instruction: 0xf7fa6838 │ │ │ │ - ldmdavs fp!, {r0, r1, r2, r3, r5, r7, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - blvc 428e4 <__time64@plt+0x41068> │ │ │ │ - bleq 1202d5c <__time64@plt+0x12014e0> │ │ │ │ + ldmdavs fp!, {r2, r3, r9, fp, ip, sp, lr, pc}^ │ │ │ │ + blvc 430d4 <__time64@plt+0x4191c> │ │ │ │ + bleq 120354c <__time64@plt+0x1201d94> │ │ │ │ ldmdavs r8!, {r1, r8, sp} │ │ │ │ - stc2 7, cr15, [r6, #1000]! @ 0x3e8 │ │ │ │ - bleq 602924 <__time64@plt+0x6010a8> │ │ │ │ + blx 105a7c <__time64@plt+0x1042c4> │ │ │ │ + bleq 603114 <__time64@plt+0x60195c> │ │ │ │ ldmdavs r8!, {r1, r8, sp} │ │ │ │ - stc2 7, cr15, [r0, #1000]! @ 0x3e8 │ │ │ │ + @ instruction: 0xf9fdf7fa │ │ │ │ msreq CPSR_, #-1073741823 @ 0xc0000001 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx fe4452ba <__time64@plt+0xfe443a3e> │ │ │ │ + blx fe445aaa <__time64@plt+0xfe4442f2> │ │ │ │ andeq pc, r8, #-1073741823 @ 0xc0000001 │ │ │ │ msreq CPSR_, #-1073741823 @ 0xc0000001 │ │ │ │ @ instruction: 0x46186839 │ │ │ │ - @ instruction: 0xff06f7fa │ │ │ │ - blvc c292c <__time64@plt+0xc10b0> │ │ │ │ - blvc 1202d98 <__time64@plt+0x120151c> │ │ │ │ + blx ff8c5aa6 <__time64@plt+0xff8c42ee> │ │ │ │ + blvc c311c <__time64@plt+0xc1964> │ │ │ │ + blvc 1203588 <__time64@plt+0x1201dd0> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ vldr d7, [r7, #24] │ │ │ │ vmov.f64 d7, #20 @ 0x40a00000 5.0 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr} │ │ │ │ - blvc 3c28f4 <__time64@plt+0x3c1078> │ │ │ │ - blvc 1c2948 <__time64@plt+0x1c10cc> │ │ │ │ - blvc 1202db4 <__time64@plt+0x1201538> │ │ │ │ + blvc 3c30e4 <__time64@plt+0x3c192c> │ │ │ │ + blvc 1c3138 <__time64@plt+0x1c1980> │ │ │ │ + blvc 12035a4 <__time64@plt+0x1201dec> │ │ │ │ stc 8, cr6, [r3, #236] @ 0xec │ │ │ │ svclt 0x00007b16 │ │ │ │ @ instruction: 0x46bd3738 │ │ │ │ svclt 0x0000bd80 │ │ │ │ andhi pc, r0, pc, lsr #7 │ │ │ │ strbpl r2, [r4], #-3352 @ 0xfffff2e8 │ │ │ │ svccc 0x00f921fb │ │ │ │ @@ -5807,329 +6364,329 @@ │ │ │ │ subsvs r2, sl, r0, lsl #4 │ │ │ │ ldrbtmi r4, [fp], #-2824 @ 0xfffff4f8 │ │ │ │ @ instruction: 0x601a68ba │ │ │ │ ldmdbvs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ svclt 0x0000bf00 │ │ │ │ ssatmi r3, #30, r4, lsl #14 │ │ │ │ - blvc 1454c8 <__time64@plt+0x143c4c> │ │ │ │ + blvc 145cb8 <__time64@plt+0x144500> │ │ │ │ svclt 0x00004770 │ │ │ │ - andeq r7, r0, sl, lsr r8 │ │ │ │ - andeq r7, r0, sl, lsr #16 │ │ │ │ + strheq r8, [r0], -sl │ │ │ │ + andeq r8, r0, sl, lsr #1 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ and sl, lr, r0, lsl #30 │ │ │ │ ldrbtmi r4, [fp], #-2838 @ 0xfffff4ea │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ - blmi 55f460 <__time64@plt+0x55dbe4> │ │ │ │ + blmi 55fc50 <__time64@plt+0x55e498> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0xf7fb4618 │ │ │ │ - blmi 5064dc <__time64@plt+0x504c60> │ │ │ │ + blmi 506cc4 <__time64@plt+0x50550c> │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ - blmi 49f3f0 <__time64@plt+0x49db74> │ │ │ │ + blmi 49fbe0 <__time64@plt+0x49e428> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ - blmi 43f3cc <__time64@plt+0x43db50> │ │ │ │ + blmi 43fbbc <__time64@plt+0x43e404> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ rsbsvs r6, fp, fp, lsl r8 │ │ │ │ ldrbtmi r4, [fp], #-2830 @ 0xfffff4f2 │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - mcrr2 7, 15, pc, r2, cr11 @ │ │ │ │ + mcrr2 7, 15, pc, r0, cr11 @ │ │ │ │ ldrbtmi r4, [fp], #-2828 @ 0xfffff4f4 │ │ │ │ andsvs r6, sl, sl, ror r8 │ │ │ │ ldrbtmi r4, [fp], #-2827 @ 0xfffff4f5 │ │ │ │ - blcs 21424 <__time64@plt+0x1fba8> │ │ │ │ + blcs 21c14 <__time64@plt+0x2045c> │ │ │ │ svclt 0x0000d1eb │ │ │ │ strcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - strdeq r7, [r0], -lr │ │ │ │ - strdeq r7, [r0], -r4 │ │ │ │ - andeq r7, r0, r8, ror #15 │ │ │ │ - andeq r7, r0, r0, ror #15 │ │ │ │ - ldrdeq r7, [r0], -r0 │ │ │ │ - andeq r7, r0, r6, asr #15 │ │ │ │ - @ instruction: 0x000077ba │ │ │ │ - @ instruction: 0x000077b2 │ │ │ │ + andeq r8, r0, lr, ror r0 │ │ │ │ + andeq r8, r0, r4, ror r0 │ │ │ │ + andeq r8, r0, r8, rrx │ │ │ │ + andeq r8, r0, r0, rrx │ │ │ │ + andeq r8, r0, r0, asr r0 │ │ │ │ + andeq r8, r0, r6, asr #32 │ │ │ │ + andeq r8, r0, sl, lsr r0 │ │ │ │ + andeq r8, r0, r2, lsr r0 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldrbtmi r4, [fp], #-2845 @ 0xfffff4e3 │ │ │ │ - blcs 21464 <__time64@plt+0x1fbe8> │ │ │ │ - blmi 73b834 <__time64@plt+0x739fb8> │ │ │ │ + blcs 21c54 <__time64@plt+0x2049c> │ │ │ │ + blmi 73c024 <__time64@plt+0x73a86c> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - mrc2 7, 5, pc, cr12, cr11, {7} │ │ │ │ + mrc2 7, 5, pc, cr10, cr11, {7} │ │ │ │ ldrbtmi r4, [fp], #-2842 @ 0xfffff4e6 │ │ │ │ @ instruction: 0x21ac221c │ │ │ │ ldrbtmi r4, [r8], #-2073 @ 0xfffff7e7 │ │ │ │ - blx 1745402 <__time64@plt+0x1743b86> │ │ │ │ + blx 16c5bf2 <__time64@plt+0x16c443a> │ │ │ │ and r6, sl, r8, ror r1 │ │ │ │ ldrbtmi r4, [fp], #-2839 @ 0xfffff4e9 │ │ │ │ cmnvs fp, fp, lsl r8 │ │ │ │ ldrbtmi r4, [fp], #-2838 @ 0xfffff4ea │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, fp, sp, lr} │ │ │ │ ldrbtmi r4, [fp], #-2837 @ 0xfffff4eb │ │ │ │ andscs r6, ip, #26 │ │ │ │ ldmdbvs r8!, {r8, sp}^ │ │ │ │ - stmib lr, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldc 7, cr15, [r4, #-996]! @ 0xfffffc1c │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ @ instruction: 0x609a68fa │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, r7, sp, lr}^ │ │ │ │ @ instruction: 0x611a68ba │ │ │ │ andcs r6, r0, #2015232 @ 0x1ec000 │ │ │ │ ldmdbvs fp!, {r1, r3, r4, r6, r8, sp, lr}^ │ │ │ │ orrsvs r2, sl, r0, lsl #4 │ │ │ │ @ instruction: 0x4618697b │ │ │ │ ssatmi r3, #30, r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq r7, r0, r6, ror r7 │ │ │ │ + strdeq r7, [r0], -r6 │ │ │ │ @ instruction: 0xffffff61 │ │ │ │ @ instruction: 0xffffff03 │ │ │ │ - andeq r4, r0, lr, asr r6 │ │ │ │ - andeq r7, r0, lr, asr #14 │ │ │ │ - andeq r7, r0, r6, asr #14 │ │ │ │ - andeq r7, r0, lr, lsr r7 │ │ │ │ + andeq r4, r0, r2, ror #11 │ │ │ │ + andeq r7, r0, lr, asr #31 │ │ │ │ + andeq r7, r0, r6, asr #31 │ │ │ │ + @ instruction: 0x00007fbe │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blcs 2167c <__time64@plt+0x1fe00> │ │ │ │ + blcs 21e6c <__time64@plt+0x206b4> │ │ │ │ ldmdavs r8!, {r2, r3, ip, lr, pc}^ │ │ │ │ @ instruction: 0xff3af7ff │ │ │ │ ldrbtmi r4, [fp], #-2822 @ 0xfffff4fa │ │ │ │ ldmdavs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ - blmi 15f50c <__time64@plt+0x15dc90> │ │ │ │ + blmi 15fcfc <__time64@plt+0x15e544> │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ and r6, r0, sl, lsl r0 │ │ │ │ strcc fp, [r8, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r7, r0, lr, asr #13 │ │ │ │ - andeq r7, r0, r4, asr #13 │ │ │ │ + andeq r7, r0, lr, asr #30 │ │ │ │ + andeq r7, r0, r4, asr #30 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ orrsvs r6, sl, sl, lsr r8 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r4, sp, lr, pc}^ │ │ │ │ rscsvs r6, fp, fp, asr r9 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7fb4618 │ │ │ │ - ldmvs fp!, {r0, r1, r2, r5, r7, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmvs fp!, {r0, r2, r5, r7, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ subsvs r2, sl, r0, lsl #4 │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ cmpvs sl, fp, ror r8 │ │ │ │ ldrbtmi r4, [fp], #-2824 @ 0xfffff4f8 │ │ │ │ ldmvs fp!, {r1, r3, r4, fp, sp, lr}^ │ │ │ │ - blmi 1df560 <__time64@plt+0x1ddce4> │ │ │ │ + blmi 1dfd50 <__time64@plt+0x1de598> │ │ │ │ ldmvs sl!, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, sp, lr}^ │ │ │ │ - blcs 21a70 <__time64@plt+0x201f4> │ │ │ │ + blcs 22260 <__time64@plt+0x20aa8> │ │ │ │ movwcs sp, #483 @ 0x1e3 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r7, r0, r6, ror r6 │ │ │ │ - andeq r7, r0, ip, ror #12 │ │ │ │ + strdeq r7, [r0], -r6 │ │ │ │ + andeq r7, r0, ip, ror #29 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ - blmi 49f620 <__time64@plt+0x49dda4> │ │ │ │ + blmi 49fe10 <__time64@plt+0x49e658> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ tstle r8, r0, lsl #22 │ │ │ │ andcs r2, r8, #0, 6 │ │ │ │ stmdami pc, {r0, r1, r2, r5, r6, r7, r8, sp} @ │ │ │ │ @ instruction: 0xf7fb4478 │ │ │ │ - ldrhtvs pc, [r8], #173 @ 0xad @ │ │ │ │ - blmi 37f578 <__time64@plt+0x37dcfc> │ │ │ │ + ldrhtvs pc, [r8], #171 @ 0xab @ │ │ │ │ + blmi 37fd68 <__time64@plt+0x37e5b0> │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ - blmi 2e15cc <__time64@plt+0x2dfd50> │ │ │ │ + blmi 2e1dbc <__time64@plt+0x2e0604> │ │ │ │ andsvs r4, sl, fp, ror r4 │ │ │ │ ldmdbvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0x601a68fb │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ ldmdavs fp!, {r1, r3, r4, r6, sp, lr}^ │ │ │ │ ldrshvs r6, [sl, #-138] @ 0xffffff76 │ │ │ │ ldrcc fp, [r0, -r0, lsl #30] │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r7, r0, r8, lsr #12 │ │ │ │ - andeq r4, r0, r0, lsr #10 │ │ │ │ - andeq r7, r0, ip, lsl #12 │ │ │ │ - andeq r7, r0, r0, lsl #12 │ │ │ │ + andeq r7, r0, r8, lsr #29 │ │ │ │ + andeq r4, r0, r4, lsr #9 │ │ │ │ + andeq r7, r0, ip, lsl #29 │ │ │ │ + andeq r7, r0, r0, lsl #29 │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ smladcc ip, r8, r6, r4 │ │ │ │ @ instruction: 0xf85d46bd │ │ │ │ ldrbmi r7, [r0, -r4, lsl #22]! │ │ │ │ addlt fp, r3, r0, lsl #9 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x46181ad3 │ │ │ │ ldrtmi r3, [sp], ip, lsl #14 │ │ │ │ - blvc 14573c <__time64@plt+0x143ec0> │ │ │ │ + blvc 145f2c <__time64@plt+0x144774> │ │ │ │ strlt r4, [r0, #1904] @ 0x770 │ │ │ │ svcge 0x0000b084 │ │ │ │ eorsvs r6, r9, r8, ror r0 │ │ │ │ ldmvs sl, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldrmi r6, [r3], #-2107 @ 0xfffff7c5 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, r6, r7, sp, lr}^ │ │ │ │ ldmdavs fp!, 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47de44 <__time64@plt+0x47c68c> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603ff3d │ │ │ │ ldmdavs fp!, {r1, r2, r4, sp, lr, pc}^ │ │ │ │ svcne 0x001a691b │ │ │ │ tstvs sl, fp, ror r8 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ rscsvs r6, fp, fp, lsl r8 │ │ │ │ @ instruction: 0x461868fb │ │ │ │ - ldmda lr!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bl ff945e34 <__time64@plt+0xff94467c> │ │ │ │ ldrmi r4, [sl], -r3, lsl #12 │ │ │ │ andsvs r6, sl, fp, lsr r8 │ │ │ │ ldmvs fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr}^ │ │ │ │ ldmdavs fp!, {r1, r3, r4, r8, sl, fp, ip}^ │ │ │ │ movwcs r6, #4314 @ 0x10da │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - andeq r4, r0, r4, lsl #9 │ │ │ │ + andeq r4, r0, r8, lsl #8 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr}^ │ │ │ │ - blcs e1afc <__time64@plt+0xe0280> │ │ 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lr, #52 @ 0x34 │ │ │ │ movwcs lr, #4146 @ 0x1032 │ │ │ │ @ instruction: 0xf10760bb │ │ │ │ ldmdavc fp, {r3, r8, r9} │ │ │ │ tstle r3, r1, lsl #22 │ │ │ │ movwcc r6, #18491 @ 0x483b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ ldc2 7, cr15, [sl, #1020] @ 0x3fc │ │ │ │ - blcs 19300 <__time64@plt+0x17a84> │ │ │ │ + blcs 19af0 <__time64@plt+0x18338> │ │ │ │ ldmdavs r9!, {r3, ip, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fd93 │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ ands r2, r9, r1, lsl #6 │ │ │ │ ands r2, r7, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ stc2 7, cr15, [r8, #1020] @ 0x3fc │ │ │ │ - blcs 19324 <__time64@plt+0x17aa8> │ │ │ │ + blcs 19b14 <__time64@plt+0x1835c> │ │ │ │ ldmdavs fp!, {r1, r3, ip, lr, pc} │ │ │ │ ldrmi r3, [r9], -r4, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fd7f │ │ │ │ andle r2, r1, r0, lsl #22 │ │ │ │ and r2, r5, r1, lsl #6 │ │ │ │ and r2, r3, r0, lsl #6 │ │ │ │ and r2, r1, r1, lsl #6 │ │ │ │ - mcr 7, 4, pc, cr4, cr9, {7} @ │ │ │ │ + b ac6310 <__time64@plt+0xac4b58> │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r6, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ movwcs r6, #59 @ 0x3b │ │ │ │ ands r6, r1, fp, ror r1 │ │ │ │ ldmdavs sl!, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr} │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ ldrmi r6, [sl], #-2234 @ 0xfffff746 │ │ │ │ @ instruction: 0x46116a3b │ │ │ │ @ instruction: 0x479868f8 │ │ │ │ - blcs 1937c <__time64@plt+0x17b00> │ │ │ │ + blcs 19b6c <__time64@plt+0x183b4> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdbvs fp!, {r0, r1, r2, sp, lr, pc}^ │ │ │ │ cmnvs fp, r1, lsl #6 │ │ │ │ ldmdavs fp!, {r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ mvnle r4, #-1610612727 @ 0xa0000009 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ - blcs 21d8c <__time64@plt+0x20510> │ │ │ │ + blcs 2257c <__time64@plt+0x20dc4> │ │ │ │ movwcs sp, #4353 @ 0x1101 │ │ │ │ ldmvs r8!, {r2, r3, r5, sp, lr, pc}^ │ │ │ │ ldc2l 7, cr15, [r4], #1020 @ 0x3fc │ │ │ │ - blcs 593bc <__time64@plt+0x57b40> │ │ │ │ + blcs 59bac <__time64@plt+0x583f4> │ │ │ │ ldmdavs sl!, {r0, r1, r3, r8, ip, lr, pc}^ │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ ldc2 7, cr15, [r0, #1020] @ 0x3fc │ │ │ │ - blcs 193cc <__time64@plt+0x17b50> │ │ │ │ + blcs 19bbc <__time64@plt+0x18404> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ movwcs lr, #4124 @ 0x101c │ │ │ │ ldmvs r8!, {r1, r3, r4, sp, lr, pc}^ │ │ │ │ stc2l 7, cr15, [r2], #1020 @ 0x3fc │ │ │ │ - blcs 193e0 <__time64@plt+0x17b64> │ │ │ │ + blcs 19bd0 <__time64@plt+0x18418> │ │ │ │ ldmdavs sl!, {r0, r1, r3, r8, ip, lr, pc}^ │ │ │ │ ldmvs r8!, {r0, r3, r4, r5, r7, fp, sp, lr}^ │ │ │ │ mcr2 7, 0, pc, cr0, cr15, {7} @ │ │ │ │ - blcs 193f0 <__time64@plt+0x17b74> │ │ │ │ + blcs 19be0 <__time64@plt+0x18428> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ movwcs lr, #4106 @ 0x100a │ │ │ │ ldmvs r8!, {r3, sp, lr, pc}^ │ │ │ │ ldc2l 7, cr15, [r0], {255} @ 0xff │ │ │ │ - blcs 99404 <__time64@plt+0x97b88> │ │ │ │ + blcs 99bf4 <__time64@plt+0x9843c> │ │ │ │ movwcs sp, #4353 @ 0x1101 │ │ │ │ movwcs lr, #0 │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ @ instruction: 0x4618681b │ │ │ │ - ldc 7, cr15, [sl, #996]! @ 0x3e4 │ │ │ │ + stmdb r0!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ rscsvs r4, fp, r3, lsl #12 │ │ │ │ movweq pc, #49415 @ 0xc107 @ │ │ │ │ ldrmi r2, [r9], -r4, lsl #4 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603ffb1 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, sp, r0, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -fp, lsr #25 │ │ │ │ tstle r6, r1, lsl #22 │ │ │ │ @ instruction: 0x461868fb │ │ │ │ - stcl 7, cr15, [r8, #-996] @ 0xfffffc1c │ │ │ │ + stmia lr!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldmdavs fp!, {r1, r9, sl, lr} │ │ │ │ movwcs r6, #4122 @ 0x101a │ │ │ │ @ instruction: 0x37104618 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ @ instruction: 0x4618881b │ │ │ │ - stcl 7, cr15, [r2], #996 @ 0x3e4 │ │ │ │ + stm r8, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ mvnshi r4, r3, lsl #12 │ │ │ │ movweq pc, #57607 @ 0xe107 @ │ │ │ │ ldrmi r2, [r9], -r2, lsl #4 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r7, lsl #31 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, lr, r0, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r1, lsl #25 │ │ │ │ tstle r7, r1, lsl #22 │ │ │ │ @ instruction: 0x461889fb │ │ │ │ - stc 7, cr15, [r4, #996] @ 0x3e4 │ │ │ │ + stmdb sl!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrmi r4, [sl], -r3, lsl #12 │ │ │ │ andshi r6, sl, fp, lsr r8 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ strlt fp, [r0, #3456] @ 0xd80 │ │ │ │ svcge 0x0000b082 │ │ │ │ eorsvs r6, r9, r8, ror r0 │ │ │ │ @@ -6420,35 +6977,35 @@ │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mcr2 7, 3, pc, cr8, cr15, {7} @ │ │ │ │ - blcs 194f4 <__time64@plt+0x17c78> │ │ │ │ + blcs 19ce4 <__time64@plt+0x1852c> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r4, r7, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r4, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fe5d │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ add r2, r8, r0, lsl #6 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ mvnsmi pc, #683671552 @ 0x28c00000 │ │ │ │ - blcs 516ab8 <__time64@plt+0x51523c> │ │ │ │ + blcs 5172a8 <__time64@plt+0x515af0> │ │ │ │ andcs fp, r1, #140, 30 @ 0x230 │ │ │ │ sbcslt r2, r2, #0, 4 │ │ │ │ tstle r9, r0, lsl #20 │ │ │ │ andmi pc, r1, #64, 4 │ │ │ │ andseq pc, r0, #192, 4 │ │ │ │ vpmax.u8 d15, d3, d18 │ │ │ │ movweq pc, #4099 @ 0x1003 @ │ │ │ │ svclt 0x00142b00 │ │ │ │ movwcs r2, #769 @ 0x301 │ │ │ │ - blcs 348a4 <__time64@plt+0x33028> │ │ │ │ + blcs 35094 <__time64@plt+0x338dc> │ │ │ │ ldmdavs fp!, {r1, r3, ip, lr, pc} │ │ │ │ ldrmi r3, [r9], -r8, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r9, lsl #29 │ │ │ │ cmnle r0, r0, lsl #22 │ │ │ │ rsb r2, r2, r0, lsl #6 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, fp, sp, lr}^ │ │ │ │ @@ -6460,239 +7017,239 @@ │ │ │ │ @ instruction: 0x461968fa │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fd37 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ sub r2, ip, r0, lsl #6 │ │ │ │ @ instruction: 0xf00368fb │ │ │ │ adcsvs r0, fp, r7, lsl #6 │ │ │ │ - blcs 22074 <__time64@plt+0x207f8> │ │ │ │ + blcs 22864 <__time64@plt+0x210ac> │ │ │ │ ldmvs fp!, {r0, r1, r6, ip, lr, pc} │ │ │ │ movweq pc, #33219 @ 0x81c3 @ │ │ │ │ tstcs r0, sl, lsl r6 │ │ │ │ ldrbtmi r4, [fp], #-2850 @ 0xfffff4de │ │ │ │ @ instruction: 0xf7f94618 │ │ │ │ - ldmvs fp!, {r2, r3, r4, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + ldmvs fp!, {r1, r7, fp, sp, lr, pc} │ │ │ │ movweq pc, #33219 @ 0x81c3 @ │ │ │ │ - blmi 7d9610 <__time64@plt+0x7d7d94> │ │ │ │ + blmi 7d9e00 <__time64@plt+0x7d8648> │ │ │ │ @ instruction: 0x4619447b │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fd17 │ │ │ │ @ instruction: 0xd12c2b00 │ │ │ │ eor r2, ip, r0, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r9, ror #23 │ │ │ │ @ instruction: 0xd1242b01 │ │ │ │ @ instruction: 0xf103683b │ │ │ │ movwcs r0, #4360 @ 0x1108 │ │ │ │ ldmdavs r8!, {r1, r3, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ ldc2 7, cr15, [r0], #1020 @ 0x3fc │ │ │ │ - blcs 195e8 <__time64@plt+0x17d6c> │ │ │ │ + blcs 19dd8 <__time64@plt+0x18620> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmvs fp!, {r0, r3, r4, sp, lr, pc}^ │ │ │ │ movweq pc, #28675 @ 0x7003 @ │ │ │ │ ldmvs fp!, {r0, r1, r3, r4, r5, r7, sp, lr} │ │ │ │ andsle r2, r0, r0, lsl #22 │ │ │ │ @ instruction: 0xf1c368bb │ │ │ │ ldrmi r0, [sl], -r8, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2827 @ 0xfffff4f5 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2l 7, cr15, [ip], #-1020 @ 0xfffffc04 │ │ │ │ - blcs 19614 <__time64@plt+0x17d98> │ │ │ │ + blcs 19e04 <__time64@plt+0x1864c> │ │ │ │ movwcs sp, #259 @ 0x103 │ │ │ │ svclt 0x0000e003 │ │ │ │ svclt 0x0000e000 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ ssatmi r3, #30, r0, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - ldrdeq r6, [r0], -r6 @ │ │ │ │ - andeq r6, r0, r4, asr #27 │ │ │ │ - andeq r6, r0, r2, ror sp │ │ │ │ + andeq r7, r0, r6, asr r6 │ │ │ │ + andeq r7, r0, r4, asr #12 │ │ │ │ + strdeq r7, [r0], -r2 │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ 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│ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fd52 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eor r2, r1, r0, lsl #6 │ │ │ │ @ instruction: 0x3320683b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx ff1c6802 <__time64@plt+0xff1c4f86> │ │ │ │ - blcs 1a014 <__time64@plt+0x18798> │ │ │ │ + blx ff1c6ff2 <__time64@plt+0xff1c583a> │ │ │ │ + blcs 1a804 <__time64@plt+0x1904c> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r1, r2, r4, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -ip, lsr #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -sp, asr #17 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, fp, r0, lsl #6 │ │ │ │ teqcc r0, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx ff6c682e <__time64@plt+0xff6c4fb2> │ │ │ │ - blcs 1a040 <__time64@plt+0x187c4> │ │ │ │ + blx ff6c701e <__time64@plt+0xff6c5866> │ │ │ │ + blcs 1a830 <__time64@plt+0x19078> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ movwcs lr, #4096 @ 0x1000 │ │ │ │ smladcc r8, r8, r6, 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0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ - blx 1146906 <__time64@plt+0x114508a> │ │ │ │ - blcs 1a118 <__time64@plt+0x1889c> │ │ │ │ + blx 11470f6 <__time64@plt+0x114593e> │ │ │ │ + blcs 1a908 <__time64@plt+0x19150> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r3, sp, lr, pc} │ │ │ │ @ instruction: 0x4619335c │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -pc, lsl #17 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, r0, r0, lsl #6 │ │ │ │ @@ -7218,70 +7775,70 @@ │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fd3c │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ add r2, ip, r0, lsl #6 │ │ │ │ movwcc r6, #51259 @ 0xc83b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mrrc2 7, 15, pc, r2, cr15 @ │ │ │ │ - blcs 1a16c <__time64@plt+0x188f0> │ │ │ │ + blcs 1a95c <__time64@plt+0x191a4> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r7, sp, lr, pc} │ │ │ │ @ instruction: 0x46193312 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ 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0x4603fd50 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ sub r2, sl, r0, lsl #6 │ │ │ │ movtcc r6, #34875 @ 0x883b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2 7, cr15, [lr, #1020] @ 0x3fc │ │ │ │ - blcs 1a1f0 <__time64@plt+0x18974> │ │ │ │ + blcs 1a9e0 <__time64@plt+0x19228> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r3, r4, r5, sp, lr, pc} │ │ │ │ @ instruction: 0x46193358 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603faf7 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eors r2, r4, r0, lsl #6 │ │ │ │ cmncc r4, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf953f7ff │ │ │ │ - blcs 1a21c <__time64@plt+0x189a0> │ │ │ │ + blcs 1aa0c <__time64@plt+0x19254> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r3, r5, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r5, ror #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r8, asr #18 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, lr, r0, lsl #6 │ │ │ │ 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│ │ │ ldrmi r3, [r9], -sp, lsr #6 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -ip, asr #28 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eors r2, r4, r0, lsl #6 │ │ │ │ @ instruction: 0x332e683b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mcr2 7, 2, pc, cr1, cr14, {7} @ │ │ │ │ - blcs 1a840 <__time64@plt+0x18fc4> │ │ │ │ + blcs 1b030 <__time64@plt+0x19878> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r3, r5, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -pc, lsr #6 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ @ instruction: 0x4603fe36 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, lr, r0, lsl #6 │ │ │ │ teqcc r0, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2 7, cr15, [ip], #1016 @ 0x3f8 │ │ │ │ - blcs 1a86c <__time64@plt+0x18ff0> │ │ │ │ + blcs 1b05c <__time64@plt+0x198a4> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r4, sp, lr, pc} │ │ │ │ teqpeq r4, r3, lsl #2 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf893683b │ │ │ │ ldrmi r3, [sl], -sp, lsr #32 │ │ │ │ ldrbtmi r4, [fp], #-2824 @ 0xfffff4f8 │ │ │ │ movwcs r9, #33536 @ 0x8300 │ │ │ │ @@ -7687,79 +8244,79 @@ │ │ │ │ svclt 0x0000bd80 │ │ │ │ @ instruction: 0xfffffecb │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r2, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ mcr2 7, 0, pc, cr1, cr14, {7} @ │ │ │ │ - blcs 1a8c0 <__time64@plt+0x19044> │ │ │ │ + blcs 1b0b0 <__time64@plt+0x198f8> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r1, r2, r3, r4, r5, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r1, lsl #6 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ @ instruction: 0x4603fdf6 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eors r2, r3, r0, lsl #6 │ │ │ │ movwcc r6, #10299 @ 0x283b │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2l 7, cr15, [r0, #1016] @ 0x3f8 │ │ │ │ - blcs 1a8ec <__time64@plt+0x19070> │ │ │ │ + blcs 1b0dc <__time64@plt+0x19924> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ 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#4096 @ 0x1000 │ │ │ │ smladcc r8, r8, r6, r4 │ │ │ │ stclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ @ instruction: 0xfffffe75 │ │ │ │ addlt fp, r4, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r2, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf933f7ff │ │ │ │ - blcs 1a968 <__time64@plt+0x190ec> │ │ │ │ + blcs 1b158 <__time64@plt+0x199a0> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r3, r6, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -ip, lsl #6 │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ strmi pc, [r3], -r9, asr #16 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eors r2, lr, r0, lsl #6 │ │ │ │ tstcc r2, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf887f7ff │ │ │ │ - blcs 1a994 <__time64@plt+0x19118> │ │ │ │ + blcs 1b184 <__time64@plt+0x199cc> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r4, r5, sp, lr, pc} │ │ │ │ @ instruction: 0x46193318 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -ip, lsl #27 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eor r2, r8, r0, lsl #6 │ │ │ │ tstcc r9, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2 7, cr15, [r1, #1016] @ 0x3f8 │ │ │ │ - blcs 1a9c0 <__time64@plt+0x19144> │ │ │ │ + blcs 1b1b0 <__time64@plt+0x199f8> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r2, r3, r4, sp, lr, pc} │ │ │ │ @ instruction: 0x4619331a │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -fp, asr #26 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, r2, r0, lsl #6 │ │ │ │ @@ -7777,48 +8334,48 @@ │ │ │ │ svclt 0x0000bd80 │ │ │ │ @ instruction: 0xfffffebb │ │ │ │ addlt fp, r2, r0, lsl #11 │ │ │ │ rsbsvs sl, r8, r0, lsl #30 │ │ │ │ ldmdavs fp!, {r0, r3, r4, r5, sp, lr} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf8d3f7ff │ │ │ │ - blcs 1aa28 <__time64@plt+0x191ac> │ │ │ │ + blcs 1b218 <__time64@plt+0x19a60> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r2, r3, r6, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -ip, lsl #6 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -r9, ror #31 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ sub r2, r2, r0, lsl #6 │ │ │ │ tstcc r2, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xffdef7fe │ │ │ │ - blcs 1aa54 <__time64@plt+0x191d8> │ │ │ │ + blcs 1b244 <__time64@plt+0x19a8c> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r4, r5, sp, lr, pc} │ │ │ │ @ instruction: 0x46193318 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -sp, lsr #23 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ eor r2, ip, r0, lsl #6 │ │ │ │ tstcc ip, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ stc2 7, cr15, [r1, #-1016]! @ 0xfffffc08 │ │ │ │ - blcs 1aa80 <__time64@plt+0x19204> │ │ │ │ + blcs 1b270 <__time64@plt+0x19ab8> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r5, sp, lr, pc} │ │ │ │ @ instruction: 0x4619331d │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ @ instruction: 0x4603fd16 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ ands r2, r6, r0, lsl #6 │ │ │ │ tstcc lr, #3866624 @ 0x3b0000 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xffb2f7fe │ │ │ │ - blcs 1aaac <__time64@plt+0x19230> │ │ │ │ + blcs 1b29c <__time64@plt+0x19ae4> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmdavs fp!, {r0, r1, r3, sp, lr, pc} │ │ │ │ ldrmi r3, [r9], -r4, lsr #6 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -r1, lsl #23 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ and r2, r0, r0, lsl #6 │ │ │ │ @@ -7830,25 +8387,25 @@ │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ @ instruction: 0x4603f95f │ │ │ │ tstle r5, r1, lsl #22 │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ rscsvs pc, r8, r5, ror #18 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf869f7ff │ │ │ │ - blcs 1aafc <__time64@plt+0x19280> │ │ │ │ + blcs 1b2ec <__time64@plt+0x19b34> │ │ │ │ movwcs sp, #257 @ 0x101 │ │ │ │ ldmvs r9!, {r1, r2, r3, r5, r6, r7, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7fe6878 │ │ │ │ strmi pc, [r3], -r6, ror #18 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ rsc r2, r5, r0, lsl #6 │ │ │ │ ldmvc fp, {r0, r1, r3, r4, r5, fp, sp, lr} │ │ │ │ @ instruction: 0xdc3b2b17 │ │ │ │ vqdmlsl.s q9, d0, d0 │ │ │ │ - blcs 5e9604 <__time64@plt+0x5e7d88> │ │ │ │ + blcs 5e9df4 <__time64@plt+0x5e863c> │ │ │ │ adcshi pc, r8, r0, lsl #4 │ │ │ │ @ instruction: 0xf852a202 │ │ │ │ ldrmi r3, [sl], #-35 @ 0xffffffdd │ │ │ │ svclt 0x00004710 │ │ │ │ andeq r0, r0, r7, rrx │ │ │ │ andeq r0, r0, fp, ror r0 │ │ │ │ muleq r0, pc, r0 @ │ │ │ │ @@ -7873,69 +8430,69 @@ │ │ │ │ andeq r0, r0, r5, ror #2 │ │ │ │ andeq r0, r0, sp, lsl r1 │ │ │ │ andeq r0, r0, pc, lsr #2 │ │ │ │ mlsle sp, ip, fp, r2 │ │ │ │ ldmdavs fp!, {r1, r2, r3, r4, r5, r6, sp, lr, pc} │ │ │ │ ldmdavs r8!, {r0, r3, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf813f7ff │ │ │ │ - blcs 1aba8 <__time64@plt+0x1932c> │ │ │ │ + blcs 1b398 <__time64@plt+0x19be0> │ │ │ │ movwcs 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rsb r2, fp, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ - blx fe0c7402 <__time64@plt+0xfe0c5b86> │ │ │ │ - blcs 1ac14 <__time64@plt+0x19398> │ │ │ │ + blx fe0c7bf2 <__time64@plt+0xfe0c643a> │ │ │ │ + blcs 1b404 <__time64@plt+0x19c4c> │ │ │ │ movwcs sp, #340 @ 0x154 │ │ │ │ ldmdavs r9!, {r1, r5, r6, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fbf9 │ │ │ │ cmple sp, r0, lsl #22 │ │ │ │ subs r2, r9, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ - blx fe987426 <__time64@plt+0xfe985baa> │ │ │ │ - blcs 1ac38 <__time64@plt+0x193bc> │ │ │ │ + blx fe987c16 <__time64@plt+0xfe98645e> │ │ │ │ + blcs 1b428 <__time64@plt+0x19c70> │ │ │ │ movwcs sp, #326 @ 0x146 │ │ │ │ ldmdavs r9!, {r4, r6, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ff6878 │ │ │ │ @ instruction: 0x4603fcdf │ │ │ │ teqle pc, r0, lsl #22 │ │ │ │ sub r2, r7, r0, lsl #6 │ │ │ │ ldmdavs r8!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ ldc2 7, cr15, [r6, #-1020] @ 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│ │ + @ instruction: 0x4603ecf8 │ │ │ │ tstle r1, r0, lsl #22 │ │ │ │ subs r2, sl, r0, lsl #6 │ │ │ │ ldmdahi fp, {r0, r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ - @ instruction: 0xf7f84618 │ │ │ │ - @ instruction: 0x4603e912 │ │ │ │ + @ instruction: 0xf7f74618 │ │ │ │ + @ instruction: 0x4603ecb8 │ │ │ │ andsle r2, r4, r0, lsl #22 │ │ │ │ ldmdahi fp, {r0, r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ - @ instruction: 0xf7f84618 │ │ │ │ - strmi lr, [r3], -sl, lsl #18 │ │ │ │ + @ instruction: 0xf7f74618 │ │ │ │ + @ instruction: 0x4603ecb0 │ │ │ │ andeq pc, r8, r7, lsl #2 │ │ │ │ ldrbtmi r4, [sl], #-2600 @ 0xfffff5d8 │ │ │ │ - @ instruction: 0xf7f82107 │ │ │ │ - @ instruction: 0xf107e8cc │ │ │ │ + @ instruction: 0xf7f72107 │ │ │ │ + @ instruction: 0xf107ec72 │ │ │ │ ldrmi r0, [r9], -r8, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2853 @ 0xfffff4db │ │ │ │ - @ instruction: 0xf7f84618 │ │ │ │ - blmi 943730 <__time64@plt+0x941eb4> │ │ │ │ + @ instruction: 0xf7f74618 │ │ │ │ + blmi 944db8 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0xf107e89c │ │ │ │ + @ instruction: 0xf7f72107 │ │ │ │ + @ instruction: 0xf107ec42 │ │ │ │ ldrmi r0, [r9], -r8, lsl #6 │ │ │ │ ldrbtmi r4, [fp], #-2833 @ 0xfffff4ef │ │ │ │ - @ instruction: 0xf7f84618 │ │ │ │ - blmi 4436d0 <__time64@plt+0x441e54> │ │ │ │ + @ instruction: 0xf7f74618 │ │ │ │ + blmi 444d58 <__time64@plt+0x4435a0> │ │ │ │ and r4, sl, fp, ror r4 │ │ │ │ ldmdahi fp, {r0, r1, r3, r4, r5, r6, fp, sp, lr} │ │ │ │ ldrbtmi r4, [sl], #-2574 @ 0xfffff5f2 │ │ │ │ stmdami lr, {r7, r8, sp} │ │ │ │ - @ instruction: 0xf7f84478 │ │ │ │ - blmi 383850 <__time64@plt+0x381fd4> │ │ │ │ + @ instruction: 0xf7f74478 │ │ │ │ + blmi 384ed8 <__time64@plt+0x383720> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ ssatmi r3, #30, r8, lsl #14 │ │ │ │ svclt 0x0000bd80 │ │ │ │ - andeq r5, r0, lr, lsl #12 │ │ │ │ - strdeq r2, [r0], -r6 │ │ │ │ - andeq r5, r0, sl, asr #11 │ │ │ │ - andeq r5, r0, r0, asr #11 │ │ │ │ - andeq r5, r0, lr, lsr #11 │ │ │ │ - muleq r0, r6, r6 │ │ │ │ - andeq r5, r0, sl, ror #10 │ │ │ │ - andeq r5, r0, r0, ror #10 │ │ │ │ - andeq r2, r0, r6, ror r6 │ │ │ │ - andeq r5, r0, r0, asr r5 │ │ │ │ - andeq r5, r0, r8, asr #10 │ │ │ │ + andeq r5, r0, lr, lsl #29 │ │ │ │ + andeq r2, r0, sl, ror r6 │ │ │ │ + andeq r5, r0, sl, asr #28 │ │ │ │ + andeq r5, r0, r0, asr #28 │ │ │ │ + andeq r5, r0, lr, lsr #28 │ │ │ │ + andeq r2, r0, sl, lsl r6 │ │ │ │ + andeq r5, r0, sl, ror #27 │ │ │ │ + andeq r5, r0, r0, ror #27 │ │ │ │ + strdeq r2, [r0], -sl │ │ │ │ + ldrdeq r5, [r0], -r0 │ │ │ │ + andeq r5, r0, r8, asr #27 │ │ │ │ umulllt fp, pc, r0, r5 @ │ │ │ │ rscsvs sl, r8, r0, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ ldmdavs fp!, {r0, r1, r3, r4, r5, sp, lr} │ │ │ │ tstcs r0, #-1073741778 @ 0xc000002e │ │ │ │ @ instruction: 0xf10761fb │ │ │ │ eorsvs r0, fp, #16, 6 @ 0x40000000 │ │ │ │ @@ -8068,34 +8625,34 @@ │ │ │ │ adcsvs r2, fp, #0, 6 │ │ │ │ rscsvs r2, fp, #0, 6 │ │ │ │ teqvs fp, fp @ │ │ │ │ cmnvs fp, fp, ror r8 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ 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ldrbtmi r4, [fp], #-2821 @ 0xfffff4fb │ │ │ │ @ instruction: 0xf7f74618 │ │ │ │ - movwcs lr, #3944 @ 0xf68 │ │ │ │ - blvs 1ee24d4 <__time64@plt+0x1ee0c58> │ │ │ │ + movwcs lr, #2842 @ 0xb1a │ │ │ │ + blvs 1ee2cc4 <__time64@plt+0x1ee150c> │ │ │ │ @ instruction: 0x373c4618 │ │ │ │ ldclt 6, cr4, [r0, #756] @ 0x2f4 │ │ │ │ - ldrdeq r2, [r0], -lr │ │ │ │ + andeq r2, r0, r2, ror #10 │ │ │ │ @ instruction: 0xb091b5f0 │ │ │ │ rscsvs sl, r8, r2, lsl #30 │ │ │ │ ldrhtvs r6, [sl], #-9 │ │ │ │ stcmi 0, cr6, [r0], #-236 @ 0xffffff14 │ │ │ │ tstcs r0, #124, 8 @ 0x7c000000 │ │ │ │ @ instruction: 0xf107623b │ │ │ │ rsbsvs r0, fp, #20, 6 @ 0x50000000 │ │ │ │ @@ -8104,160 +8661,160 @@ │ │ │ │ teqvs fp, #0, 6 │ │ │ │ ldrhvs r6, [fp, #-139]! @ 0xffffff75 │ │ │ │ @ instruction: 0x61bb687b │ │ │ │ mvnsvs r6, fp, lsr r8 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ tstpeq ip, r7, lsl #2 @ p-variant is OBSOLETE │ │ │ │ ldrmi r2, [r8], -r0, lsl #4 │ │ │ │ - svc 0x0084f7f7 │ │ │ │ + bl ac7f04 <__time64@plt+0xac674c> │ │ │ │ @ instruction: 0xf1b34603 │ │ │ │ @ instruction: 0xd11b3fff │ │ │ │ stmiapl r3!, {r0, r4, r8, r9, fp, lr}^ │ │ │ │ - blmi 4637bc <__time64@plt+0x461f40> │ │ │ │ + blmi 463fac <__time64@plt+0x4627f4> │ │ │ │ ldmdavs ip, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf7ff6838 │ │ │ │ @ instruction: 0x4606fefb │ │ │ │ - svc 0x00ecf7f7 │ │ │ │ + bl fe4c7f24 <__time64@plt+0xfe4c676c> │ │ │ │ ldmdavs fp, {r0, r1, r9, sl, lr} │ │ │ │ @ instruction: 0xf7f74618 │ │ │ │ - @ instruction: 0x4603efb2 │ │ │ │ + @ instruction: 0x4603eb58 │ │ │ │ ldrtmi r9, [r3], -r0, lsl #6 │ │ │ │ stmdbmi r9, {r1, r5, r9, sl, lr} │ │ │ │ @ instruction: 0x46284479 │ │ │ │ - svc 0x00d2f7f7 │ │ │ │ + bl 1e47f40 <__time64@plt+0x1e46788> │ │ │ │ and r2, r0, r0, lsl #6 │ │ │ │ ldrmi r2, [r8], -r1, lsl #6 │ │ │ │ @ instruction: 0x46bd373c │ │ │ │ svclt 0x0000bdf0 │ │ │ │ - strdeq r3, [r0], -ip │ │ │ │ + andeq r4, r0, ip, lsl #2 │ │ │ │ + andeq r0, r0, r8, lsl r1 │ │ │ │ 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cr15, {7} │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r9, fp, sp, lr}^ │ │ │ │ - bvs 1ee22a8 <__time64@plt+0x1ee0a2c> │ │ │ │ + bvs 1ee2a98 <__time64@plt+0x1ee12e0> │ │ │ │ @ instruction: 0xf47f2b00 │ │ │ │ - bvs ef56c0 <__time64@plt+0xef3e44> │ │ │ │ + bvs ef5eb0 <__time64@plt+0xef46f8> │ │ │ │ teqle lr, r0, lsl #22 │ │ │ │ stmiapl r3!, {r0, r1, r5, r8, r9, fp, lr}^ │ │ │ │ - blcs 2393c <__time64@plt+0x220c0> │ │ │ │ - blmi 8bd908 <__time64@plt+0x8bc08c> │ │ │ │ + blcs 2412c <__time64@plt+0x22974> │ │ │ │ + blmi 8be0f8 <__time64@plt+0x8bc940> │ │ │ │ ldmdavs ip, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf7ff6838 │ │ │ │ @ instruction: 0x4603fe35 │ │ │ │ @ instruction: 0x4621461a │ │ │ │ ldrbtmi r4, [fp], #-2849 @ 0xfffff4df │ │ │ │ @ instruction: 0xf7f74618 │ │ │ │ - movwcs lr, #3682 @ 0xe62 │ │ │ │ + movwcs lr, #2580 @ 0xa14 │ │ │ │ vst1.8 {d18-d21}, [pc :128], r0 │ │ │ │ ldmdami lr, {r0, r2, r3, r4, r5, r7, r8, ip, sp, lr} │ │ │ │ @ instruction: 0xf7f94478 │ │ │ │ - cmnpvs r8, r7, ror #17 @ p-variant is OBSOLETE │ │ │ │ + cmnpvs r8, r5, ror #17 @ p-variant is OBSOLETE │ │ │ │ andcs r6, r0, #2015232 @ 0x1ec000 │ │ │ │ - blmi 6e1970 <__time64@plt+0x6e00f4> │ │ │ │ + blmi 6e2160 <__time64@plt+0x6e09a8> │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ subsvs r6, sl, fp, ror r9 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ andle r2, r3, r0, lsl #22 │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ andsvs r6, sl, sl, ror r9 │ │ │ │ movwcc r6, #35195 @ 0x897b │ │ │ │ ldmdavs r9!, {r4, r9, sp} │ │ │ │ @ instruction: 0xf7f74618 │ │ │ │ - andcs lr, r0, r6, ror #28 │ │ │ │ - svc 0x00a6f7f7 │ │ │ │ + andcs lr, r0, r8, lsl sl │ │ │ │ + bl 1348100 <__time64@plt+0x1346948> │ │ │ │ strmi r4, [fp], -r2, lsl #12 │ │ │ │ stmib r1, {r0, r3, r4, r5, r6, r8, fp, sp, lr}^ │ │ │ │ - blmi 392558 <__time64@plt+0x390cdc> │ │ │ │ + blmi 392d48 <__time64@plt+0x391590> │ │ │ │ ldmdbvs sl!, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ svclt 0x0000601a │ │ │ │ ldrtmi r3, [sp], r8, lsr #14 │ │ │ │ movshi lr, #12386304 @ 0xbd0000 │ │ │ │ - andeq r3, r0, sl, asr r8 │ │ │ │ - @ instruction: 0x000053bc │ │ │ │ - andeq r0, r0, r0, lsr #2 │ │ │ │ - andeq r0, r0, r0, lsr r1 │ │ │ │ - andeq r2, r0, lr, asr #9 │ │ │ │ - andeq r5, r0, r4, lsr r3 │ │ │ │ - andeq r2, r0, r6, lsl #9 │ │ │ │ + andeq r4, r0, sl, rrx │ │ │ │ + andeq r5, r0, ip, lsr ip │ │ │ │ + andeq r0, r0, r4, lsl r1 │ │ │ │ + andeq r0, r0, r4, lsr #2 │ │ │ │ andeq r2, r0, r2, asr r4 │ │ │ │ - andeq r2, r0, r8, asr r4 │ │ │ │ - andeq r5, r0, ip, ror #4 │ │ │ │ - andeq r5, r0, r4, lsr r2 │ │ │ │ + @ instruction: 0x00005bb4 │ │ │ │ + andeq r2, r0, sl, lsl #8 │ │ │ │ + ldrdeq r2, [r0], -r6 │ │ │ │ + ldrdeq r2, [r0], -ip │ │ │ │ + andeq r5, r0, ip, ror #21 │ │ │ │ + @ instruction: 0x00005ab4 │ │ │ │ @ instruction: 0xf6adb5b0 │ │ │ │ svcge 0x00000d28 │ │ │ │ msreq CPSR_f, #7340032 @ 0x700000 │ │ │ │ msreq CPSR_s, #170917888 @ 0xa300000 │ │ │ │ @ instruction: 0xf6076018 │ │ │ │ @ instruction: 0xf6a30328 │ │ │ │ andsvs r0, r9, r8, lsr #6 │ │ │ │ @@ -8271,254 +8828,254 @@ │ │ │ │ movwcs r3, #6176 @ 0x1820 │ │ │ │ stmdacc r4!, {r0, r1, r2, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf8d7e09b │ │ │ │ addseq r3, fp, r4, lsr #16 │ │ │ │ eoreq pc, r8, #7340032 @ 0x700000 │ │ │ │ eoreq pc, r8, #169869312 @ 0xa200000 │ │ │ │ ldrmi r6, [r3], #-2066 @ 0xfffff7ee │ │ │ │ - bmi 1f23a40 <__time64@plt+0x1f221c4> │ │ │ │ + bmi 1f24230 <__time64@plt+0x1f22a78> │ │ │ │ @ instruction: 0x4611447a │ │ │ │ @ instruction: 0xf7f74618 │ │ │ │ - @ instruction: 0x4603edd8 │ │ │ │ + strmi lr, [r3], -sl, lsl #19 │ │ │ │ andsle r2, r2, r0, lsl #22 │ │ │ │ stmdacc r4!, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf607009b │ │ │ │ @ instruction: 0xf6a20228 │ │ │ │ ldmdavs r2, {r3, r5, r9} │ │ │ │ ldmdavs fp, {r0, r1, r4, sl, lr} │ │ │ │ ldrbtmi r4, [sl], #-2675 @ 0xfffff58d │ │ │ │ @ instruction: 0x46184611 │ │ │ │ - stcl 7, cr15, [r4, #988] @ 0x3dc │ │ │ │ - blcs 1b214 <__time64@plt+0x19998> │ │ │ │ - blmi 1c3de64 <__time64@plt+0x1c3c5e8> │ │ │ │ + ldmdb r6!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blcs 1ba04 <__time64@plt+0x1a24c> │ │ │ │ + blmi 1c3e654 <__time64@plt+0x1c3ce9c> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - mcr 7, 2, pc, cr12, cr7, {7} @ │ │ │ │ + ldmib r2!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [fp], #-2926 @ 0xfffff492 │ │ │ │ @ instruction: 0xf7f74618 │ │ │ │ - blmi 1b85340 <__time64@plt+0x1b83ac4> │ │ │ │ + blmi 1b849c8 <__time64@plt+0x1b83210> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - mcr 7, 2, pc, cr2, cr7, {7} @ │ │ │ │ + stmib r8!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [fp], #-2923 @ 0xfffff495 │ │ │ │ @ instruction: 0xf7f74618 │ │ │ │ - andcs lr, r0, lr, lsr lr │ │ │ │ - mrc 7, 2, APSR_nzcv, cr14, cr7, {7} │ │ │ │ + andcs lr, r0, r4, ror #19 │ │ │ │ + b 148204 <__time64@plt+0x146a4c> │ │ │ │ stmdacc r4!, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf607009b │ │ │ │ @ instruction: 0xf6a20228 │ │ │ │ ldmdavs r2, {r3, r5, r9} │ │ │ │ ldmdavs fp, {r0, r1, r4, sl, lr} │ │ │ │ ldrbtmi r4, [sl], #-2659 @ 0xfffff59d │ │ │ │ @ instruction: 0x46184611 │ │ │ │ - ldc 7, cr15, [sl, #988] @ 0x3dc │ │ │ │ - blcs 1b268 <__time64@plt+0x199ec> │ │ │ │ - blmi 183de70 <__time64@plt+0x183c5f4> │ │ │ │ + stmdb ip, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blcs 1ba58 <__time64@plt+0x1a2a0> │ │ │ │ + blmi 183e660 <__time64@plt+0x183cea8> │ │ │ │ andcs r5, r1, #14876672 @ 0xe30000 │ │ │ │ sub r6, r1, sl, lsl r0 │ │ │ │ stmdacc r4!, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf607009b │ │ │ │ @ instruction: 0xf6a20228 │ │ │ │ ldmdavs r2, {r3, r5, r9} │ │ │ │ ldmdavs fp, {r0, r1, r4, sl, lr} │ │ │ │ ldrbtmi r4, [sl], #-2649 @ 0xfffff5a7 │ │ │ │ @ instruction: 0x46184611 │ │ │ │ - stc 7, cr15, [r2, #988] @ 0x3dc │ │ │ │ - blcs 1b298 <__time64@plt+0x19a1c> │ │ │ │ + ldmdb r4!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blcs 1ba88 <__time64@plt+0x1a2d0> │ │ │ │ @ instruction: 0xf8d7d11e │ │ │ │ movwcc r3, #6180 @ 0x1824 │ │ │ │ eoreq pc, r8, #7340032 @ 0x700000 │ │ │ │ eoreq pc, r4, #169869312 @ 0xa200000 │ │ │ │ addsmi r6, sl, #1179648 @ 0x120000 │ │ │ │ @ instruction: 0xf8d7dd14 │ │ │ │ movwcc r3, #6180 @ 0x1824 │ │ │ │ stmdacc r4!, {r0, r1, r2, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ stmdacc r4!, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf607009b │ │ │ │ @ instruction: 0xf6a20228 │ │ │ │ ldmdavs r2, {r3, r5, r9} │ │ │ │ ldmdavs fp, {r0, r1, r4, sl, lr} │ │ │ │ @ instruction: 0xf7f74618 │ │ │ │ - @ instruction: 0xf8c7ee8a │ │ │ │ + @ instruction: 0xf8c7ea30 │ │ │ │ and r0, pc, r0, lsr #16 │ │ │ │ stmdacc r4!, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf607009b │ │ │ │ @ instruction: 0xf6a20228 │ │ │ │ ldmdavs r2, {r3, r5, r9} │ │ │ │ ldmdavs fp, {r0, r1, r4, sl, lr} │ │ │ │ - blmi 105b348 <__time64@plt+0x1059acc> │ │ │ │ + blmi 105bb38 <__time64@plt+0x105a380> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - @ instruction: 0xff7ef7f8 │ │ │ │ + @ instruction: 0xff7cf7f8 │ │ │ │ stmdacc r4!, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf8c73301 │ │ │ │ @ instruction: 0xf6073824 │ │ │ │ @ instruction: 0xf6a30328 │ │ │ │ @ instruction: 0xf8d70324 │ │ │ │ ldmdavs fp, {r2, r5, fp, sp} │ │ │ │ @ instruction: 0xf6ff429a │ │ │ │ @ instruction: 0xf8d7af5a │ │ │ │ tstcs r0, r0, lsr #16 │ │ │ │ @ instruction: 0xf7f92001 │ │ │ │ @ instruction: 0xf8c7fde1 │ │ │ │ @ instruction: 0xf8d7081c │ │ │ │ - blcs 17b90 <__time64@plt+0x16314> │ │ │ │ - blmi cbdf34 <__time64@plt+0xcbc6b8> │ │ │ │ + blcs 18380 <__time64@plt+0x16bc8> │ │ │ │ + blmi cbe724 <__time64@plt+0xcbcf6c> │ │ │ │ @ instruction: 0x4618447b │ │ │ │ - @ instruction: 0xff5ef7f8 │ │ │ │ + @ instruction: 0xff5cf7f8 │ │ │ │ stmiapl r3!, {r2, r3, r5, r8, r9, fp, lr}^ │ │ │ │ - blcs 23ba0 <__time64@plt+0x22324> │ │ │ │ + blcs 24390 <__time64@plt+0x22bd8> │ │ │ │ @ instruction: 0xf607d00d │ │ │ │ @ instruction: 0xf6a30328 │ │ │ │ ldmdavs fp, {r3, r5, r8, r9} │ │ │ │ @ instruction: 0xf8d7681b │ │ │ │ ldrmi r2, [r9], -r0, lsr #16 │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ @ instruction: 0xf7f74618 │ │ │ │ - @ instruction: 0xf607ed30 │ │ │ │ + @ instruction: 0xf607e8e2 │ │ │ │ @ instruction: 0xf1070308 │ │ │ │ vst4.8 {d16,d18,d20,d22}, [pc], r8 │ │ │ │ @ instruction: 0xf8d76200 │ │ │ │ @ instruction: 0xf7ff081c │ │ │ │ @ instruction: 0xf8c7fd81 │ │ │ │ - blmi 74bbcc <__time64@plt+0x74a350> │ │ │ │ + blmi 74c3bc <__time64@plt+0x74ac04> │ │ │ │ ldmdavs fp, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ andsle r2, r3, r0, lsl #22 │ │ │ │ ldmdacc r8, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ - vstrle d2, [pc, #-0] @ 9b7c <__time64@plt+0x8300> │ │ │ │ + vstrle d2, [pc, #-0] @ a36c <__time64@plt+0x8bb4> │ │ │ │ stmiapl r3!, {r4, r8, r9, fp, lr}^ │ │ │ │ @ instruction: 0xf607681d │ │ │ │ ldrmi r0, [r8], -r8, lsl #6 │ │ │ │ ldc2l 7, cr15, [lr], {255} @ 0xff │ │ │ │ @ instruction: 0xf8d74603 │ │ │ │ @ instruction: 0x46292818 │ │ │ │ ldrbtmi r4, [r8], #-2071 @ 0xfffff7e9 │ │ │ │ - stc 7, cr15, [sl, #-988] @ 0xfffffc24 │ │ │ │ + ldm ip!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldmdacc r8, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ vldrle d18, [r6] │ │ │ │ movweq pc, #34311 @ 0x8607 @ │ │ │ │ tstpeq r8, r7, lsl #2 @ p-variant is OBSOLETE │ │ │ │ ldmdacs r8, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ ldmdaeq ip, {r0, r1, r2, r4, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ stc2l 7, cr15, [lr, #1020]! @ 0x3fc │ │ │ │ svclt 0x0000e7cb │ │ │ │ - andeq r3, r0, r6, ror #12 │ │ │ │ - andeq r0, r0, r0, lsr r1 │ │ │ │ - andeq r2, r0, r8, lsl #7 │ │ │ │ - andeq r2, r0, sl, ror #6 │ │ │ │ - andeq r2, r0, ip, asr r3 │ │ │ │ - andeq r2, r0, r6, ror #6 │ │ │ │ - andeq r2, r0, ip, lsl #7 │ │ │ │ - @ instruction: 0x000023b6 │ │ │ │ - andeq r2, r0, sl, lsr #7 │ │ │ │ - andeq r0, r0, r0, lsr #2 │ │ │ │ - andeq r2, r0, r2, lsl #7 │ │ │ │ - andeq r2, r0, r4, lsr #6 │ │ │ │ - andeq r2, r0, r0, lsl r3 │ │ │ │ - andeq r2, r0, lr, lsl r3 │ │ │ │ + andeq r3, r0, r6, ror lr │ │ │ │ + andeq r0, r0, r4, lsr #2 │ │ │ │ + andeq r2, r0, ip, lsl #6 │ │ │ │ andeq r2, r0, lr, ror #5 │ │ │ │ + andeq r2, r0, r0, ror #5 │ │ │ │ + andeq r2, r0, sl, ror #5 │ │ │ │ + andeq r2, r0, r0, lsl r3 │ │ │ │ + andeq r2, r0, sl, lsr r3 │ │ │ │ + andeq r2, r0, lr, lsr #6 │ │ │ │ + andeq r0, r0, r4, lsl r1 │ │ │ │ + andeq r2, r0, r6, lsl #6 │ │ │ │ + andeq r2, r0, r8, lsr #5 │ │ │ │ + muleq r0, r4, r2 │ │ │ │ + andeq r2, r0, r2, lsr #5 │ │ │ │ + andeq r2, r0, r2, ror r2 │ │ │ │ ldmdblt r2!, {r0, r1, r3, r4, r5, r6, r8, fp, ip, sp, pc}^ │ │ │ │ svclt 0x00be2900 │ │ │ │ @ instruction: 0xf04f2000 │ │ │ │ and r4, r6, r0, lsl #2 │ │ │ │ stmdacs r0, {r3, r8, r9, sl, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf06fbf1c │ │ │ │ @ instruction: 0xf04f4100 │ │ │ │ @ instruction: 0xf00030ff │ │ │ │ @ instruction: 0xf1adb83f │ │ │ │ stmdb sp!, {r3, sl, fp}^ │ │ │ │ stmdbcs r0, {r2, r9, sl, fp, lr, pc} │ │ │ │ - blcs 4084c <__time64@plt+0x3efd0> │ │ │ │ + blcs 4103c <__time64@plt+0x3f884> │ │ │ │ @ instruction: 0xf000db1a │ │ │ │ @ instruction: 0xf8ddf83b │ │ │ │ ldmib sp, {r2, sp, lr, pc}^ │ │ │ │ andlt r2, r4, r2, lsl #6 │ │ │ │ submi r4, r0, #112, 14 @ 0x1c00000 │ │ │ │ cmpeq r1, r1, ror #22 │ │ │ │ - blle 6d4844 <__time64@plt+0x6d2fc8> │ │ │ │ + blle 6d5034 <__time64@plt+0x6d387c> │ │ │ │ @ instruction: 0xf82ef000 │ │ │ │ ldrd pc, [r4], -sp │ │ │ │ movwcs lr, #10717 @ 0x29dd │ │ │ │ submi fp, r0, #4 │ │ │ │ cmpeq r1, r1, ror #22 │ │ │ │ - bl 18da5a4 <__time64@plt+0x18d8d28> │ │ │ │ + bl 18dad94 <__time64@plt+0x18d95dc> │ │ │ │ ldrbmi r0, [r0, -r3, asr #6]! │ │ │ │ - bl 18da5ac <__time64@plt+0x18d8d30> │ │ │ │ + bl 18dad9c <__time64@plt+0x18d95e4> │ │ │ │ @ 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