--- /srv/rebuilderd/tmp/rebuilderd8gKfi0/inputs/gcc-14-plugin-dev_14.4.0-4_armhf.deb +++ /srv/rebuilderd/tmp/rebuilderd8gKfi0/out/gcc-14-plugin-dev_14.4.0-4_armhf.deb ├── file list │ @@ -1,3 +1,3 @@ │ -rw-r--r-- 0 0 0 4 2026-11-07 15:51:32.000000 debian-binary │ -rw-r--r-- 0 0 0 13584 2026-11-07 15:51:32.000000 control.tar.xz │ --rw-r--r-- 0 0 0 1449916 2026-11-07 15:51:32.000000 data.tar.xz │ +-rw-r--r-- 0 0 0 1449900 2026-11-07 15:51:32.000000 data.tar.xz ├── control.tar.xz │ ├── control.tar │ │ ├── ./md5sums │ │ │ ├── ./md5sums │ │ │ │┄ Files differ ├── data.tar.xz │ ├── data.tar │ │ ├── ./usr/libexec/gcc/arm-linux-gnueabihf/14/plugin/gengtype │ │ │┄ File has been modified after NT_GNU_BUILD_ID has been applied. │ │ │ ├── readelf --wide --file-header {} │ │ │ │ @@ -4,15 +4,15 @@ │ │ │ │ Data: 2's complement, little endian │ │ │ │ Version: 1 (current) │ │ │ │ OS/ABI: UNIX - System V │ │ │ │ ABI Version: 0 │ │ │ │ Type: EXEC (Executable file) │ │ │ │ Machine: ARM │ │ │ │ Version: 0x1 │ │ │ │ - Entry point address: 0x1803d │ │ │ │ + Entry point address: 0x18035 │ │ │ │ Start of program headers: 52 (bytes into file) │ │ │ │ Start of section headers: 197964 (bytes into file) │ │ │ │ Flags: 0x5000400, Version5 EABI, hard-float ABI │ │ │ │ Size of this header: 52 (bytes) │ │ │ │ Size of program headers: 32 (bytes) │ │ │ │ Number of program headers: 10 │ │ │ │ Size of section headers: 40 (bytes) │ │ │ ├── readelf --wide --program-header {} │ │ │ │ @@ -1,23 +1,23 @@ │ │ │ │ │ │ │ │ Elf file type is EXEC (Executable file) │ │ │ │ -Entry point 0x1803d │ │ │ │ +Entry point 0x18035 │ │ │ │ There are 10 program headers, starting at offset 52 │ │ │ │ │ │ │ │ Program Headers: │ │ │ │ Type Offset VirtAddr PhysAddr FileSiz MemSiz Flg Align │ │ │ │ - ARM_EXIDX 0x022e44 0x00032e44 0x00032e44 0x00520 0x00520 R 0x4 │ │ │ │ + ARM_EXIDX 0x022e3c 0x00032e3c 0x00032e3c 0x00520 0x00520 R 0x4 │ │ │ │ PHDR 0x000034 0x00010034 0x00010034 0x00140 0x00140 R 0x4 │ │ │ │ INTERP 0x000198 0x00010198 0x00010198 0x00019 0x00019 R 0x1 │ │ │ │ [Requesting program interpreter: /lib/ld-linux-armhf.so.3] │ │ │ │ - LOAD 0x000000 0x00010000 0x00010000 0x23388 0x23388 R E 0x10000 │ │ │ │ + LOAD 0x000000 0x00010000 0x00010000 0x23380 0x23380 R E 0x10000 │ │ │ │ LOAD 0x02fecc 0x0004fecc 0x0004fecc 0x00504 0x009ec RW 0x10000 │ │ │ │ DYNAMIC 0x02ff18 0x0004ff18 0x0004ff18 0x000e8 0x000e8 RW 0x4 │ │ │ │ NOTE 0x000174 0x00010174 0x00010174 0x00024 0x00024 R 0x4 │ │ │ │ - NOTE 0x023368 0x00033368 0x00033368 0x00020 0x00020 R 0x4 │ │ │ │ + NOTE 0x023360 0x00033360 0x00033360 0x00020 0x00020 R 0x4 │ │ │ │ GNU_STACK 0x000000 0x00000000 0x00000000 0x00000 0x00000 RW 0x10 │ │ │ │ GNU_RELRO 0x02fecc 0x0004fecc 0x0004fecc 0x00134 0x00134 R 0x1 │ │ │ │ │ │ │ │ Section to Segment mapping: │ │ │ │ Segment Sections... │ │ │ │ 00 .ARM.exidx │ │ │ │ 01 │ │ │ ├── readelf --wide --sections {} │ │ │ │ @@ -10,21 +10,21 @@ │ │ │ │ [ 5] .dynstr STRTAB 000108f8 0008f8 00030a 00 A 0 0 1 │ │ │ │ [ 6] .gnu.version VERSYM 00010c02 000c02 00009a 02 A 4 0 2 │ │ │ │ [ 7] .gnu.version_r VERNEED 00010c9c 000c9c 000040 00 A 5 1 4 │ │ │ │ [ 8] .rel.dyn REL 00010cdc 000cdc 000070 08 A 4 0 4 │ │ │ │ [ 9] .rel.plt REL 00010d4c 000d4c 000220 08 AI 4 23 4 │ │ │ │ [10] .init PROGBITS 00010f6c 000f6c 00000c 00 AX 0 0 4 │ │ │ │ [11] .plt PROGBITS 00010f78 000f78 00037c 04 AX 0 0 4 │ │ │ │ - [12] .text PROGBITS 000112f8 0012f8 01758c 00 AX 0 0 8 │ │ │ │ - [13] .fini PROGBITS 00028884 018884 000008 00 AX 0 0 4 │ │ │ │ - [14] .rodata PROGBITS 0002888c 01888c 00a4d4 00 A 0 0 4 │ │ │ │ - [15] .ARM.extab PROGBITS 00032d60 022d60 0000e4 00 A 0 0 4 │ │ │ │ - [16] .ARM.exidx ARM_EXIDX 00032e44 022e44 000520 00 AL 12 0 4 │ │ │ │ - [17] .eh_frame PROGBITS 00033364 023364 000004 00 A 0 0 4 │ │ │ │ - [18] .note.ABI-tag NOTE 00033368 023368 000020 00 A 0 0 4 │ │ │ │ + [12] .text PROGBITS 000112f8 0012f8 017584 00 AX 0 0 8 │ │ │ │ + [13] .fini PROGBITS 0002887c 01887c 000008 00 AX 0 0 4 │ │ │ │ + [14] .rodata PROGBITS 00028884 018884 00a4d4 00 A 0 0 4 │ │ │ │ + [15] .ARM.extab PROGBITS 00032d58 022d58 0000e4 00 A 0 0 4 │ │ │ │ + [16] .ARM.exidx ARM_EXIDX 00032e3c 022e3c 000520 00 AL 12 0 4 │ │ │ │ + [17] .eh_frame PROGBITS 0003335c 02335c 000004 00 A 0 0 4 │ │ │ │ + [18] .note.ABI-tag NOTE 00033360 023360 000020 00 A 0 0 4 │ │ │ │ [19] .init_array INIT_ARRAY 0004fecc 02fecc 000004 04 WA 0 0 4 │ │ │ │ [20] .fini_array FINI_ARRAY 0004fed0 02fed0 000004 04 WA 0 0 4 │ │ │ │ [21] .data.rel.ro PROGBITS 0004fed4 02fed4 000044 00 WA 0 0 4 │ │ │ │ [22] .dynamic DYNAMIC 0004ff18 02ff18 0000e8 08 WA 5 0 4 │ │ │ │ [23] .got PROGBITS 00050000 030000 000160 04 WA 0 0 4 │ │ │ │ [24] .data PROGBITS 00050160 030160 000270 00 WA 0 0 4 │ │ │ │ [25] .bss NOBITS 000503d0 0303d0 0004e8 00 WA 0 0 8 │ │ │ ├── readelf --wide --dynamic {} │ │ │ │ @@ -1,13 +1,13 @@ │ │ │ │ │ │ │ │ Dynamic section at offset 0x2ff18 contains 24 entries: │ │ │ │ Tag Type Name/Value │ │ │ │ 0x00000001 (NEEDED) Shared library: [libc.so.6] │ │ │ │ 0x0000000c (INIT) 0x10f6c │ │ │ │ - 0x0000000d (FINI) 0x28884 │ │ │ │ + 0x0000000d (FINI) 0x2887c │ │ │ │ 0x00000019 (INIT_ARRAY) 0x4fecc │ │ │ │ 0x0000001b (INIT_ARRAYSZ) 4 (bytes) │ │ │ │ 0x0000001a (FINI_ARRAY) 0x4fed0 │ │ │ │ 0x0000001c (FINI_ARRAYSZ) 4 (bytes) │ │ │ │ 0x6ffffef5 (GNU_HASH) 0x101b4 │ │ │ │ 0x00000005 (STRTAB) 0x108f8 │ │ │ │ 0x00000006 (SYMTAB) 0x10428 │ │ │ ├── readelf --wide --notes {} │ │ │ │ @@ -1,8 +1,8 @@ │ │ │ │ │ │ │ │ Displaying notes found in: .note.gnu.build-id │ │ │ │ Owner Data size Description │ │ │ │ - GNU 0x00000014 NT_GNU_BUILD_ID (unique build ID bitstring) Build ID: 6b1adafe60bff703f9ff48be281d099e0452a0aa │ │ │ │ + GNU 0x00000014 NT_GNU_BUILD_ID (unique build ID bitstring) Build ID: 2ebb321eecdc1d546da1daaf485d14622746af02 │ │ │ │ │ │ │ │ Displaying notes found in: .note.ABI-tag │ │ │ │ Owner Data size Description │ │ │ │ GNU 0x00000010 NT_GNU_ABI_TAG (ABI version tag) OS: Linux, ABI: 3.2.0 │ │ │ ├── objdump --line-numbers --disassemble --demangle --reloc --no-show-raw-insn --section=.init {} │ │ │ │ @@ -1,9 +1,9 @@ │ │ │ │ │ │ │ │ │ │ │ │ │ │ │ │ Disassembly of section .init: │ │ │ │ │ │ │ │ 00010f6c <.init>: │ │ │ │ push {r3, lr} │ │ │ │ - bl 18070 <__time64@plt+0x6d88> │ │ │ │ + bl 18068 <__time64@plt+0x6d80> │ │ │ │ pop {r3, pc} │ │ │ ├── objdump --line-numbers --disassemble --demangle --reloc --no-show-raw-insn --section=.text {} │ │ │ │ @@ -3,43 +3,43 @@ │ │ │ │ │ │ │ │ Disassembly of section .text: │ │ │ │ │ │ │ │ 000112f8 <.text>: │ │ │ │ strmi fp, [sp], -r0, lsl #10 │ │ │ │ cmplt r0, r3, lsl #1 │ │ │ │ vmax.s8 d20, d13, d4 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ ldmib r4, {r1}^ │ │ │ │ stmiavs r1!, {r0, r8, r9, sp}^ │ │ │ │ @ instruction: 0xf0009500 │ │ │ │ vtst.8 , q0, │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strmi r0, [fp], -r5, lsl #8 │ │ │ │ - subne pc, r4, sp, asr #4 │ │ │ │ + eorsne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrdcs lr, [r0, -r4] │ │ │ │ @ instruction: 0xf872f000 │ │ │ │ - rsbne pc, r4, #-805306364 @ 0xd0000004 │ │ │ │ + subsne pc, ip, #-805306364 @ 0xd0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ strlt r2, [r8, #-319] @ 0xfffffec1 │ │ │ │ @ instruction: 0xf8bef000 │ │ │ │ - orrsne pc, r4, sp, asr #4 │ │ │ │ + orrne pc, ip, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ strlt r2, [r8, #-0] │ │ │ │ @ instruction: 0xffd0f7ff │ │ │ │ vshl.s8 d27, d15, d0 │ │ │ │ vmlal.s , d0, d0[3] │ │ │ │ ldrlt r0, [r0, #-517]! @ 0xfffffdfb │ │ │ │ ldrbcc pc, [r8], #576 @ 0x240 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ ldmdavs r2, {r0, r1, r7, ip, sp, pc} │ │ │ │ vqdmulh.s d26, d14, d6 │ │ │ │ - vaddw.s8 , q8, d16 │ │ │ │ + vsra.s64 d21, d8, #64 │ │ │ │ stmdavs r0!, {r1, r8} │ │ │ │ blpl 14f4d0 │ │ │ │ @ instruction: 0xf7ff9301 │ │ │ │ bls 8cfd4 │ │ │ │ stmdavs r0!, {r0, r3, r5, r9, sl, lr} │ │ │ │ svc 0x0066f7ff │ │ │ │ ldmib r0, {r5, fp, sp, lr}^ │ │ │ │ @@ -48,15 +48,15 @@ │ │ │ │ svc 0x0052f7ff │ │ │ │ mrrcne 0, 0, lr, r9, cr3 │ │ │ │ cmpvs r1, sl, lsl #4 │ │ │ │ andlt r7, r3, sl, lsl r0 │ │ │ │ ldrhtmi lr, [r0], -sp │ │ │ │ ldrbmi fp, [r0, -r4]! │ │ │ │ vshl.s8 d27, d15, d14 │ │ │ │ - vsra.s64 d21, d16, #64 │ │ │ │ + vaddw.s8 , q8, d24 │ │ │ │ ldrblt r0, [r0, #-258]! @ 0xfffffefe │ │ │ │ strbvc pc, [ip, #-576] @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ vhadd.s8 d27, d16, d2 │ │ │ │ @ instruction: 0xf2c034d8 │ │ │ │ blge 1923ec │ │ │ │ @ instruction: 0xf853682a │ │ │ │ @@ -78,15 +78,15 @@ │ │ │ │ vshl.s8 d27, d15, d0 │ │ │ │ @ instruction: 0xf2c034d8 │ │ │ │ strlt r0, [r0, #-1029] @ 0xfffffbfb │ │ │ │ subvc pc, ip, #64, 4 │ │ │ │ andeq pc, r5, #192, 4 │ │ │ │ stmdavs r0!, {r0, r1, r7, ip, sp, pc} │ │ │ │ vqdmulh.s d26, d14, d4 │ │ │ │ - vsra.s64 d21, d16, #64 │ │ │ │ + vaddw.s8 , q8, d24 │ │ │ │ ldmdavs r2, {r1, r8} │ │ │ │ blpl 14f58c │ │ │ │ @ instruction: 0xf7ff9301 │ │ │ │ bls 8cf18 │ │ │ │ stmdavs r0!, {r0, r3, r5, r9, sl, lr} │ │ │ │ svc 0x0008f7ff │ │ │ │ ldmib r0, {r5, fp, sp, lr}^ │ │ │ │ @@ -100,15 +100,15 @@ │ │ │ │ vshl.s8 d27, d15, d0 │ │ │ │ @ instruction: 0xf2c034d8 │ │ │ │ strlt r0, [r0, #-1029] @ 0xfffffbfb │ │ │ │ subvc pc, ip, #64, 4 │ │ │ │ andeq pc, r5, #192, 4 │ │ │ │ stmdavs r0!, {r0, r1, r7, ip, sp, pc} │ │ │ │ vqdmulh.s d26, d14, d4 │ │ │ │ - vsra.s64 d21, d24, #64 │ │ │ │ + vsra.s64 d21, d16, #64 │ │ │ │ ldmdavs r2, {r1, r8} │ │ │ │ blpl 14f5e4 │ │ │ │ @ instruction: 0xf7ff9301 │ │ │ │ bls 8cec0 │ │ │ │ stmdavs r0!, {r0, r3, r5, r9, sl, lr} │ │ │ │ mrc 7, 6, APSR_nzcv, cr12, cr15, {7} │ │ │ │ ldmib r0, {r5, fp, sp, lr}^ │ │ │ │ @@ -117,17 +117,17 @@ │ │ │ │ mcr 7, 6, pc, cr8, cr15, {7} @ │ │ │ │ mrrcne 0, 0, lr, r9, cr3 │ │ │ │ cmpvs r1, sl, lsl #4 │ │ │ │ andcs r7, r1, sl, lsl r0 │ │ │ │ mrc 7, 2, APSR_nzcv, cr8, cr15, {7} │ │ │ │ ldrmi r4, [r4], -sp, lsl #12 │ │ │ │ @ instruction: 0xf016b508 │ │ │ │ - strtmi pc, [fp], -r9, asr #16 │ │ │ │ + strtmi pc, [fp], -r5, asr #16 │ │ │ │ strtmi r4, [r1], -r2, lsl #12 │ │ │ │ - sbcspl pc, r0, lr, asr #4 │ │ │ │ + sbcpl pc, r8, lr, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xffc6f7ff │ │ │ │ stmdavs ip, {r4, r5, r6, r7, sl, ip, sp, pc} │ │ │ │ stcls 14, cr9, [r5, #-16] │ │ │ │ mlale r7, r4, r2, r4 │ │ │ │ stclne 2, cr11, [r0], #-776 @ 0xfffffcf8 │ │ │ │ @ instruction: 0xf4166008 │ │ │ │ @@ -2500,26 +2500,26 @@ │ │ │ │ strtls r3, [r1], #-1026 @ 0xfffffbfe │ │ │ │ @ instruction: 0xd12142ac │ │ │ │ @ instruction: 0xf7fd9803 │ │ │ │ andcs lr, r7, r2, lsl fp │ │ │ │ ldmdalt r9, {r0, ip, sp, lr, pc} │ │ │ │ strdeq sp, [r3], -ip │ │ │ │ andeq sp, r3, sl, lsr #13 │ │ │ │ - andeq sl, r1, r8, lsr #26 │ │ │ │ - andeq sl, r1, r4, lsr #26 │ │ │ │ andeq sl, r1, r0, lsr #26 │ │ │ │ andeq sl, r1, ip, lsl sp │ │ │ │ andeq sl, r1, r8, lsl sp │ │ │ │ andeq sl, r1, r4, lsl sp │ │ │ │ andeq sl, r1, r0, lsl sp │ │ │ │ - andeq sl, r1, sl, lsl #26 │ │ │ │ - andeq sl, r1, r4, lsl #26 │ │ │ │ + andeq sl, r1, ip, lsl #26 │ │ │ │ + andeq sl, r1, r8, lsl #26 │ │ │ │ + andeq sl, r1, r2, lsl #26 │ │ │ │ strdeq sl, [r1], -ip │ │ │ │ - strdeq sl, [r1], -r8 │ │ │ │ - strdeq sl, [r1], -r2 │ │ │ │ + strdeq sl, [r1], -r4 │ │ │ │ + strdeq sl, [r1], -r0 │ │ │ │ + andeq sl, r1, sl, ror #25 │ │ │ │ movweq lr, #31304 @ 0x7a48 │ │ │ │ stmdaeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ rsbsge pc, ip, sp, asr #17 │ │ │ │ strcs r4, [r1, -r4, asr #12] │ │ │ │ tstls r8, #144703488 @ 0x8a00000 │ │ │ │ ldmdblt r3!, {r0, r2, r3, r8, r9, fp, ip, pc} │ │ │ │ bl fe151a4c │ │ │ │ @@ -3617,16 +3617,16 @@ │ │ │ │ stmdacs r0, {r2, r3, r4, r8} │ │ │ │ ubfx sp, r1, #3, #17 │ │ │ │ ldrbtmi r4, [r8], #-2053 @ 0xfffff7fb │ │ │ │ svclt 0x0000bd38 │ │ │ │ andeq fp, r3, r8, asr ip │ │ │ │ andeq fp, r3, r2, asr #24 │ │ │ │ muleq r3, sl, r3 │ │ │ │ - andeq r9, r1, r8, lsl fp │ │ │ │ - ldrdeq r9, [r1], -sl │ │ │ │ + andeq r9, r1, r0, lsl fp │ │ │ │ + ldrdeq r9, [r1], -r2 │ │ │ │ @ instruction: 0x4605b530 │ │ │ │ @ instruction: 0xf7fcb087 │ │ │ │ stmdbmi r9, {r8, r9, fp, sp, lr, pc} │ │ │ │ strmi r2, [r4], -r0, lsl #4 │ │ │ │ @ instruction: 0x462b4479 │ │ │ │ addvc pc, r6, r1, lsl #10 │ │ │ │ strcs lr, [r3], #-2509 @ 0xfffff633 │ │ │ │ @@ -3846,15 +3846,15 @@ │ │ │ │ eorspl pc, r8, r8, asr #17 │ │ │ │ stmdbge r0, {r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ andcc pc, r8, r8, asr #17 │ │ │ │ strmi lr, [fp, -r8, asr #19] │ │ │ │ eorsvs pc, r4, r8, asr #17 │ │ │ │ andlt r4, r3, r0, asr #12 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - andeq sp, r1, r0, lsr r8 │ │ │ │ + andeq sp, r1, r8, lsr #16 │ │ │ │ stcls 4, cr11, [r1], {16} │ │ │ │ andne lr, r0, #192, 18 @ 0x300000 │ │ │ │ ldmib sp, {r0, r1, r7, sp, lr}^ │ │ │ │ sbcvs r2, r4, #134217728 @ 0x8000000 │ │ │ │ movwcs lr, #51648 @ 0xc9c0 │ │ │ │ blmi 1530a4 │ │ │ │ ldrlt r4, [r0, #-1904]! @ 0xfffff890 │ │ │ │ @@ -3870,15 +3870,15 @@ │ │ │ │ andeq r0, r0, ip, lsl r1 │ │ │ │ @ instruction: 0x4604b538 │ │ │ │ strmi r4, [r8], -sp, lsl #12 │ │ │ │ ldrmi r6, [r8, r3, lsr #16] │ │ │ │ strmi r4, [r2], -r9, lsr #12 │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf0024038 │ │ │ │ - ldrlt fp, [r8, #-3123]! @ 0xfffff3cd │ │ │ │ + ldrlt fp, [r8, #-3119]! @ 0xfffff3d1 │ │ │ │ strmi r2, [r4], -r0, lsl #6 │ │ │ │ blx b50f8a │ │ │ │ stmiavs r3!, {r3, r6, r8, ip, sp, pc} │ │ │ │ tstlt fp, r5, lsl #12 │ │ │ │ ldrmi r6, [r8, r0, lsl #16] │ │ │ │ andcs r6, r1, #2670592 @ 0x28c000 │ │ │ │ ldrmi r6, [r3], #-42 @ 0xffffffd6 │ │ │ │ @@ -3952,27 +3952,27 @@ │ │ │ │ andcs lr, r1, r4, lsl #17 │ │ │ │ @ instruction: 0xf824f000 │ │ │ │ andeq fp, r3, r6, lsr #16 │ │ │ │ muleq r3, lr, pc @ │ │ │ │ andeq r0, r0, r0, asr r1 │ │ │ │ andeq fp, r3, r8, asr #6 │ │ │ │ andeq r0, r0, r8, lsr #2 │ │ │ │ - andeq r9, r1, r6, lsl #15 │ │ │ │ - andeq r5, r1, ip, lsr #8 │ │ │ │ andeq r9, r1, lr, ror r7 │ │ │ │ + andeq r5, r1, r4, lsr #8 │ │ │ │ + andeq r9, r1, r6, ror r7 │ │ │ │ @ instruction: 0x4604b510 │ │ │ │ stmda r2!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdami r5, {r6, r8, fp, ip, sp, pc} │ │ │ │ stmdbmi r5, {r1, r5, r9, sl, lr} │ │ │ │ @ instruction: 0x46044478 │ │ │ │ @ instruction: 0xf7fc4479 │ │ │ │ strtmi lr, [r0], -ip, asr #17 │ │ │ │ svclt 0x0000bd10 │ │ │ │ andeq fp, r3, ip, lsr #15 │ │ │ │ - andeq r9, r1, r0, lsl #15 │ │ │ │ + andeq r9, r1, r8, ror r7 │ │ │ │ strmi fp, [r4], -r8, lsl #10 │ │ │ │ ldrbtmi r4, [fp], #-2819 @ 0xfffff4fd │ │ │ │ tstlt r3, fp, lsl r8 │ │ │ │ @ instruction: 0x46204798 │ │ │ │ ldmda r8!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x0003b7ba │ │ │ │ @ instruction: 0xf7fcb508 │ │ │ │ @@ -3982,32 +3982,32 @@ │ │ │ │ strbvc pc, [ip, -r0, asr #4] @ │ │ │ │ streq pc, [r5, -r0, asr #5] │ │ │ │ ldrbtcc pc, [r0], #576 @ 0x240 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ movwcs fp, #145 @ 0x91 │ │ │ │ strmi r4, [sp], -r0, lsl #13 │ │ │ │ subvc pc, r8, pc, asr #8 │ │ │ │ - adcpl pc, sp, #72, 4 @ 0x80000004 │ │ │ │ + adcpl pc, r5, #72, 4 @ 0x80000004 │ │ │ │ andeq pc, r1, #192, 4 │ │ │ │ - mvnscs pc, sl, asr #12 │ │ │ │ + mvncs pc, sl, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ vqadd.s8 d22, d8, d25 │ │ │ │ - vmla.f d21, d16, d1[4] │ │ │ │ + vsra.s64 , , #64 │ │ │ │ @ instruction: 0xf0010101 │ │ │ │ strbtvs pc, [r0], #4035 @ 0xfc3 @ │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - @ instruction: 0xf82cf009 │ │ │ │ + @ instruction: 0xf828f009 │ │ │ │ @ instruction: 0xf64a6260 │ │ │ │ - vaddl.s8 , d0, d0 │ │ │ │ + vshr.s64 q9, q12, #64 │ │ │ │ @ instruction: 0xf0090002 │ │ │ │ - vadd.i8 d31, d0, d21 │ │ │ │ + vadd.i8 d31, d0, d17 │ │ │ │ vqdmlal.s , d0, d0[6] │ │ │ │ @ instruction: 0xf64a0305 │ │ │ │ - vbic.i16 q10, #4 @ 0x0004 │ │ │ │ + vmul.f d20, d0, d0[7] │ │ │ │ vmla.i8 d16, d0, d2 │ │ │ │ vmull.s , d16, d0[6] │ │ │ │ andcs r0, r0, #20480 @ 0x5000 │ │ │ │ @ instruction: 0xf88363a0 │ │ │ │ andcs r2, r1, #84 @ 0x54 │ │ │ │ addscs pc, r4, r3, lsl #17 │ │ │ │ strcs r4, [r0], -r0, lsr #23 │ │ │ │ @@ -4057,38 +4057,38 @@ │ │ │ │ ldrdcc pc, [r0], -sl │ │ │ │ @ instruction: 0xf0012b00 │ │ │ │ strtvs r8, [r3], -r7, lsl #13 │ │ │ │ blcs 2f4e4 <__time64@plt+0x1e1fc> │ │ │ │ vqadd.s8 d29, d16, d14 │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ @ instruction: 0xf6480305 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ ldmdavs lr, {r1} │ │ │ │ - ldc2 0, cr15, [r0, #-8]! │ │ │ │ + stc2 0, cr15, [ip, #-8]! │ │ │ │ ldrdcc pc, [r0], -sl │ │ │ │ movwls r4, #1538 @ 0x602 │ │ │ │ @ instruction: 0xf64a4630 │ │ │ │ - vaddw.s8 q10, q0, d0 │ │ │ │ + vsra.s64 , q12, #64 │ │ │ │ vrhadd.s8 d16, d1, d2 │ │ │ │ @ instruction: 0xf7fb33f2 │ │ │ │ @ instruction: 0xe785ef92 │ │ │ │ - @ instruction: 0xf93ef003 │ │ │ │ + @ instruction: 0xf93af003 │ │ │ │ movwcs lr, #6018 @ 0x1782 │ │ │ │ ldrb r6, [pc, -r3, lsr #10]! │ │ │ │ @ instruction: 0xf64a6839 │ │ │ │ - vsubw.s8 , q0, d12 │ │ │ │ + vsubw.s8 , q0, d4 │ │ │ │ @ instruction: 0xf64a0302 │ │ │ │ - vmov.i32 d19, #3072 @ 0x00000c00 │ │ │ │ + vmov.i32 d19, #1024 @ 0x00000400 │ │ │ │ @ instruction: 0xf64a0202 │ │ │ │ - vmvn.i32 d19, #0 @ 0x00000000 │ │ │ │ + vaddl.s8 , d0, d24 │ │ │ │ @ instruction: 0xf7fb0002 │ │ │ │ @ instruction: 0xf64aeea8 │ │ │ │ - vbic.i32 d19, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d19, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf64a0102 │ │ │ │ - vmla.i d19, d0, d0[6] │ │ │ │ + vmla.i d19, d0, d0[4] │ │ │ │ @ instruction: 0xf7fb0002 │ │ │ │ @ instruction: 0xe765ee9e │ │ │ │ ldrdeq pc, [r0], -sl │ │ │ │ @ instruction: 0xf0012800 │ │ │ │ @ instruction: 0x63208616 │ │ │ │ svc 0x005af7fb │ │ │ │ ldrb r6, [fp, -r0, ror #5] │ │ │ │ @@ -4108,81 +4108,81 @@ │ │ │ │ ldmibcc r0, {r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ ldrdeq pc, [r0], -r9 │ │ │ │ vrshl.u8 d20, d0, d17 │ │ │ │ bl fea36c2c │ │ │ │ strtvs r0, [r0], #-0 │ │ │ │ @ instruction: 0xf0020080 │ │ │ │ - stcvs 13, cr15, [r3], #-68 @ 0xffffffbc │ │ │ │ + stcvs 13, cr15, [r3], #-52 @ 0xffffffcc │ │ │ │ blcs 2e2b8 <__time64@plt+0x1cfd0> │ │ │ │ strtmi sp, [r8], lr, lsl #26 │ │ │ │ ldrdcc pc, [r0], -r9 │ │ │ │ ldrtmi r6, [r3], #-3045 @ 0xfffff41b │ │ │ │ eoreq pc, r3, r8, asr r8 @ │ │ │ │ - @ instruction: 0xff38f008 │ │ │ │ + @ instruction: 0xff34f008 │ │ │ │ @ instruction: 0xf8456c23 │ │ │ │ strcc r0, [r1], -r6, lsr #32 │ │ │ │ blle ffc65dd0 │ │ │ │ blcs 2f5e8 <__time64@plt+0x1e300> │ │ │ │ tstphi pc, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ ldrne lr, [r7, #-2516] @ 0xfffff62c │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ stmdbcs r0, {r0, r2, r4, r5, r8, pc} │ │ │ │ strthi pc, [r2], -r1, asr #32 │ │ │ │ @ instruction: 0xf0114628 │ │ │ │ - stmiavs r3!, {r0, r2, r3, r7, fp, ip, sp, lr, pc} │ │ │ │ + stmiavs r3!, {r0, r3, r7, fp, ip, sp, lr, pc} │ │ │ │ cmple r1, r0, lsl #22 │ │ │ │ stccs 13, cr7, [r0, #-148] @ 0xffffff6c │ │ │ │ stclvs 1, cr13, [r1, #-172]! @ 0xffffff54 │ │ │ │ subsle r2, r9, r0, lsl #18 │ │ │ │ blcs 30c18 <__time64@plt+0x1f930> │ │ │ │ ldrbhi pc, [r4, #1]! @ │ │ │ │ blcs 30420 <__time64@plt+0x1f138> │ │ │ │ ldrbhi pc, [r6, #1]! @ │ │ │ │ strcs r6, [r1], -r3, ror #23 │ │ │ │ @ instruction: 0xf0012b00 │ │ │ │ blvs ff8f6b68 │ │ │ │ eorcc pc, r5, r3, asr r8 @ │ │ │ │ @ instruction: 0xf1033501 │ │ │ │ andsvc r0, lr, #9 │ │ │ │ - cdp2 0, 14, cr15, cr12, cr11, {0} │ │ │ │ + cdp2 0, 14, cr15, cr8, cr11, {0} │ │ │ │ adcmi r6, fp, #8960 @ 0x2300 │ │ │ │ stcvc 8, cr13, [r3, #-972]! @ 0xfffffc34 │ │ │ │ @ instruction: 0x6d61b96b │ │ │ │ - subseq pc, r8, fp, asr #4 │ │ │ │ + subseq pc, r0, fp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - @ instruction: 0xf926f006 │ │ │ │ + @ instruction: 0xf922f006 │ │ │ │ strbtvs r6, [r0], #-2211 @ 0xfffff75d │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ stcvc 6, cr8, [r3, #-180]! @ 0xffffff4c │ │ │ │ andcs fp, r1, r3, lsr #7 │ │ │ │ pop {r0, r4, ip, sp, pc} │ │ │ │ vrecps.f32 q12, q8, q8 │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ vcgt.s8 d16, d0, d5 │ │ │ │ vqdmull.s , d16, d0[6] │ │ │ │ @ instruction: 0xf6480b05 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ ldmdavs lr, {r1} │ │ │ │ - stc2l 0, cr15, [r8], #-8 │ │ │ │ + stc2l 0, cr15, [r4], #-8 │ │ │ │ @ instruction: 0xf64a4602 │ │ │ │ - vorr.i32 d20, #8 @ 0x00000008 │ │ │ │ + vorr.i32 d20, #0 @ 0x00000000 │ │ │ │ ldrtmi r0, [r0], -r2, lsl #2 │ │ │ │ ldrdvs pc, [r0], -fp │ │ │ │ mvnscc pc, #268435460 @ 0x10000004 │ │ │ │ @ instruction: 0xf7fb9600 │ │ │ │ str lr, [sl, -sl, asr #29] │ │ │ │ - andeq lr, r2, r8, ror #27 │ │ │ │ + andeq lr, r2, r0, ror #27 │ │ │ │ @ instruction: 0xf64a68e3 │ │ │ │ - vsubl.s8 , d0, d24 │ │ │ │ + vsubl.s8 , d0, d16 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d1, d2 │ │ │ │ @ instruction: 0xf003416c │ │ │ │ - ldr pc, [pc, r7, asr #26] │ │ │ │ + ldr pc, [pc, r3, asr #26] │ │ │ │ blcs 300cc <__time64@plt+0x1ede4> │ │ │ │ strbhi pc, [sp, #-1]! @ │ │ │ │ tstcs r8, r1, ror #22 │ │ │ │ smlabtcs r1, r0, r2, pc @ │ │ │ │ @ instruction: 0xf5039306 │ │ │ │ @ instruction: 0x4698751a │ │ │ │ ldrsblt pc, [r8, #-143]! @ 0xffffff71 @ │ │ │ │ @@ -4221,201 +4221,201 @@ │ │ │ │ ldrdhi pc, [r0], -r4 @ │ │ │ │ svceq 0x0000f1b8 │ │ │ │ ldrthi pc, [r2], r0 @ │ │ │ │ stmdbeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ ldmvs r0!, {r1, r2, r6, r9, sl, lr} │ │ │ │ mrscs r2, R9_usr │ │ │ │ stmdbeq r1, {r0, r3, r8, ip, sp, lr, pc} │ │ │ │ - blx feed1506 │ │ │ │ + blx fedd1506 │ │ │ │ mcrcs 8, 0, r6, cr0, cr6, {1} │ │ │ │ stcvs 1, cr13, [r3], #980 @ 0x3d4 │ │ │ │ vstrle d2, [r7, #-4] │ │ │ │ - adcseq pc, ip, fp, asr #4 │ │ │ │ + adcseq pc, r4, fp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0x464a6839 │ │ │ │ ldcl 7, cr15, [r8, #-1004]! @ 0xfffffc14 │ │ │ │ ldrdls pc, [ip], -r4 │ │ │ │ svceq 0x0000f1b9 │ │ │ │ @ instruction: 0x4623d01a │ │ │ │ - ldmdacc r0, {r0, r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdacc r8, {r0, r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdaeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ ldrmi r4, [r9], ip, asr #12 │ │ │ │ ldmdblt r6, {r1, r2, r5, r6, r9, fp, sp, lr} │ │ │ │ ldmdavs r6!, {r2, r3, sp, lr, pc} │ │ │ │ ldmdavs r0!, {r1, r2, r4, r6, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7fb4641 │ │ │ │ stmdacs r0, {r1, r2, r4, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0x4602d1f7 │ │ │ │ strtmi r2, [r0], -r3, lsl #2 │ │ │ │ - blx fe45155a │ │ │ │ + blx fe35155a │ │ │ │ stccs 8, cr6, [r0], {100} @ 0x64 │ │ │ │ strbmi sp, [ip], -ip, ror #3 │ │ │ │ blcs 30ee4 <__time64@plt+0x1fbfc> │ │ │ │ ldrbthi pc, [r9], -r0 @ │ │ │ │ blcs 2f7ec <__time64@plt+0x1e504> │ │ │ │ strthi pc, [sl], -r0, asr #32 │ │ │ │ blcs 349f4 <__time64@plt+0x2370c> │ │ │ │ ldrthi pc, [lr], #65 @ 0x41 @ │ │ │ │ @ instruction: 0xf0106e60 │ │ │ │ - stcvs 14, cr15, [r3, #-252]! @ 0xffffff04 │ │ │ │ + stcvs 14, cr15, [r3, #-236]! @ 0xffffff14 │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ stcvc 6, cr8, [r0, #-108]! @ 0xffffff94 │ │ │ │ stmdage lr, {r1, r2, r3, r5, r8, r9, sl, sp, lr, pc} │ │ │ │ andcs r2, r0, #0, 6 │ │ │ │ movwcs lr, #59853 @ 0xe9cd │ │ │ │ mrc 7, 5, APSR_nzcv, cr0, cr11, {7} │ │ │ │ blcs 2f81c <__time64@plt+0x1e534> │ │ │ │ strbhi pc, [pc, #-64]! @ 15554 <__time64@plt+0x426c> @ │ │ │ │ blcs 2f824 <__time64@plt+0x1e53c> │ │ │ │ mcrge 4, 7, pc, cr2, cr15, {1} @ │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf002681d │ │ │ │ - @ instruction: 0x6de3fb8f │ │ │ │ + @ instruction: 0x6de3fb8b │ │ │ │ movwls r4, #1538 @ 0x602 │ │ │ │ vmax.s8 d20, d1, d24 │ │ │ │ @ instruction: 0xf64a4365 │ │ │ │ - vsra.s64 q10, q4, #64 │ │ │ │ + vsra.s64 q10, q0, #64 │ │ │ │ @ instruction: 0xf7fb0102 │ │ │ │ @ instruction: 0xe6c9edf2 │ │ │ │ andeq r0, r5, r8, ror #8 │ │ │ │ - andeq lr, r2, r0, lsr fp │ │ │ │ + andeq lr, r2, r8, lsr #22 │ │ │ │ @ instruction: 0xf0012900 │ │ │ │ bvs 18f684c │ │ │ │ cmnpmi r5, r1, asr #4 @ p-variant is OBSOLETE │ │ │ │ vpmax.s8 d20, d25, d22 │ │ │ │ - vmla.i d16, d16, d0[2] │ │ │ │ + vmla.i d16, d16, d0[0] │ │ │ │ stmib r4, {r1}^ │ │ │ │ stmibmi r4!, {r1, r3, r4, r8, ip, sp} │ │ │ │ - stc2l 0, cr15, [r2, #-12] │ │ │ │ + ldc2 0, cr15, [lr, #-12]! │ │ │ │ bmi fe86ff84 │ │ │ │ - subpl pc, r4, sl, asr #12 │ │ │ │ + eorspl pc, ip, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ssatvs r4, #4, pc, lsl #19 @ │ │ │ │ cmnpmi r6, #268435460 @ p-variant is OBSOLETE @ 0x10000004 │ │ │ │ @ instruction: 0xf00366e3 │ │ │ │ - bvs 1914ae4 │ │ │ │ - subspl pc, r4, sl, asr #12 │ │ │ │ + bvs 1914ad4 │ │ │ │ + subpl pc, ip, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldmibmi r9, {r3, r4, r7, r9, fp, lr} │ │ │ │ vmax.s8 d22, d17, d19 │ │ │ │ @ instruction: 0x66e34377 │ │ │ │ - stc2 0, cr15, [r8, #-12]! │ │ │ │ + stc2 0, cr15, [r4, #-12]! │ │ │ │ @ instruction: 0xf64a6a63 │ │ │ │ - vmla.i d21, d0, d0[6] │ │ │ │ + vmla.i d21, d0, d0[4] │ │ │ │ bmi fe49563c │ │ │ │ ssatvs r4, #4, r2, lsl #19 │ │ │ │ cmnpmi r8, #268435460 @ p-variant is OBSOLETE @ 0x10000004 │ │ │ │ @ instruction: 0xf00366e3 │ │ │ │ - bvs 1914ab0 │ │ │ │ - rsbspl pc, r4, sl, asr #12 │ │ │ │ + bvs 1914aa0 │ │ │ │ + rsbpl pc, ip, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ stmibmi ip, {r0, r1, r3, r7, r9, fp, lr} │ │ │ │ vmax.s8 d22, d17, d19 │ │ │ │ @ instruction: 0x66e34379 │ │ │ │ - stc2 0, cr15, [lr, #-12] │ │ │ │ + stc2 0, cr15, [sl, #-12] │ │ │ │ @ instruction: 0xf64a6a63 │ │ │ │ - vaddl.s8 , d16, d0 │ │ │ │ + vmvn.i32 , #8 @ 0x00000008 │ │ │ │ bmi fe155670 │ │ │ │ strtvs r4, [r3], r5, lsl #19 │ │ │ │ cmnpmi sl, #268435460 @ p-variant is OBSOLETE @ 0x10000004 │ │ │ │ @ instruction: 0xf00366e3 │ │ │ │ - bvs 1914a7c │ │ │ │ - addpl pc, r8, sl, asr #12 │ │ │ │ + bvs 1914a6c │ │ │ │ + addpl pc, r0, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldmdbmi pc!, {r1, r2, r3, r4, r5, r6, r9, fp, lr}^ @ │ │ │ │ vmax.s8 d22, d17, d19 │ │ │ │ @ instruction: 0x66e3437b │ │ │ │ - ldc2l 0, cr15, [r4], #12 │ │ │ │ + ldc2l 0, cr15, [r0], #12 │ │ │ │ @ instruction: 0xf64a6a63 │ │ │ │ - vshr.s64 d21, d4, #64 │ │ │ │ + vaddl.s8 , d16, d12 │ │ │ │ bmi 1e156a4 │ │ │ │ @ instruction: 0x66a34978 │ │ │ │ cmnpmi ip, #268435460 @ p-variant is OBSOLETE @ 0x10000004 │ │ │ │ @ instruction: 0xf00366e3 │ │ │ │ - bvs 1914a48 │ │ │ │ - adcpl pc, r0, sl, asr #12 │ │ │ │ + bvs 1914a38 │ │ │ │ + addspl pc, r8, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldmdbmi r2!, {r0, r4, r5, r6, r9, fp, lr}^ │ │ │ │ vmax.s8 d22, d17, d19 │ │ │ │ @ instruction: 0x66e3437d │ │ │ │ - ldc2l 0, cr15, [sl], {3} │ │ │ │ + ldc2l 0, cr15, [r6], {3} │ │ │ │ @ instruction: 0xf64a6a63 │ │ │ │ - vaddl.s8 , d16, d28 │ │ │ │ + vaddl.s8 , d16, d20 │ │ │ │ bmi 1ad56d8 │ │ │ │ strtvs r4, [r3], fp, ror #18 │ │ │ │ cmnpmi lr, #268435460 @ p-variant is OBSOLETE @ 0x10000004 │ │ │ │ @ instruction: 0xf00366e3 │ │ │ │ - bvs 1914a14 │ │ │ │ - adcspl pc, r8, sl, asr #12 │ │ │ │ + bvs 1914a04 │ │ │ │ + adcspl pc, r0, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ stmdbmi r5!, {r2, r5, r6, r9, fp, lr}^ │ │ │ │ vmax.s8 d22, d17, d19 │ │ │ │ @ instruction: 0x66e3437f │ │ │ │ - stc2l 0, cr15, [r0], {3} │ │ │ │ + ldc2 0, cr15, [ip], #12 │ │ │ │ @ instruction: 0xf64a6a63 │ │ │ │ - vmla.i d21, d16, d0[0] │ │ │ │ + vshr.s64 d21, d24, #64 │ │ │ │ bmi 179570c │ │ │ │ ssatvs r4, #4, lr, asr #18 │ │ │ │ @ instruction: 0x53a4f44f │ │ │ │ @ instruction: 0xf00366e3 │ │ │ │ - bvs 19149e0 │ │ │ │ - sbcpl pc, ip, sl, asr #12 │ │ │ │ + bvs 19149d0 │ │ │ │ + sbcpl pc, r4, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldmdbmi r8, {r0, r1, r2, r4, r6, r9, fp, lr}^ │ │ │ │ vmax.s8 d22, d17, d19 │ │ │ │ strbtvs r4, [r3], r1, lsl #7 │ │ │ │ - stc2 0, cr15, [r6], #12 │ │ │ │ + stc2 0, cr15, [r2], #12 │ │ │ │ @ instruction: 0xf64a6a63 │ │ │ │ - vshr.s64 , q2, #64 │ │ │ │ + vmla.i d21, d16, d0[3] │ │ │ │ bmi 1455740 │ │ │ │ ssatvs r4, #4, r1, asr #18 │ │ │ │ orrmi pc, r2, #268435460 @ 0x10000004 │ │ │ │ @ instruction: 0xf00366e3 │ │ │ │ - bvs 19149ac │ │ │ │ - adceq pc, r0, r9, asr #12 │ │ │ │ + bvs 191499c │ │ │ │ + addseq pc, r8, r9, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ stmdbmi fp, {r1, r3, r6, r9, fp, lr}^ │ │ │ │ vmax.s8 d22, d17, d19 │ │ │ │ strbtvs r4, [r3], r3, lsl #7 │ │ │ │ - stc2 0, cr15, [ip], {3} │ │ │ │ + stc2 0, cr15, [r8], {3} │ │ │ │ @ instruction: 0xf64a6a63 │ │ │ │ - vshr.s64 , q6, #64 │ │ │ │ + vshr.s64 , q2, #64 │ │ │ │ bmi 1115774 │ │ │ │ strtvs r4, [r3], r4, asr #18 │ │ │ │ orrmi pc, r4, #268435460 @ 0x10000004 │ │ │ │ @ instruction: 0xf00366e3 │ │ │ │ - bvs 1914978 │ │ │ │ - rscpl pc, ip, sl, asr #12 │ │ │ │ + bvs 1914968 │ │ │ │ + rscpl pc, r4, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldmdbmi lr!, {r0, r2, r3, r4, r5, r9, fp, lr} │ │ │ │ vmax.s8 d22, d17, d19 │ │ │ │ strbtvs r4, [r3], r5, lsl #7 │ │ │ │ - ldc2l 0, cr15, [r2], #-12 │ │ │ │ + stc2l 0, cr15, [lr], #-12 │ │ │ │ @ instruction: 0xf64a4a39 │ │ │ │ - vshr.s64 , q14, #64 │ │ │ │ + vshr.s64 , q10, #64 │ │ │ │ bvs 18d57a8 │ │ │ │ @ instruction: 0x66a34937 │ │ │ │ orrmi pc, r6, #268435460 @ 0x10000004 │ │ │ │ @ instruction: 0xf00366e3 │ │ │ │ - ldmdbmi r3!, {r0, r2, r5, r6, sl, fp, ip, sp, lr, pc} │ │ │ │ - adceq pc, r0, r9, asr #12 │ │ │ │ + ldmdbmi r3!, {r0, r5, r6, sl, fp, ip, sp, lr, pc} │ │ │ │ + addseq pc, r8, r9, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ strtvs r6, [r3], r3, ror #20 │ │ │ │ orrmi pc, r7, #268435460 @ 0x10000004 │ │ │ │ @ instruction: 0xf00466e3 │ │ │ │ - @ instruction: 0xf003ff95 │ │ │ │ - bmi b55168 │ │ │ │ + @ instruction: 0xf003ff91 │ │ │ │ + bmi b55158 │ │ │ │ @ instruction: 0xf64a4601 │ │ │ │ - vaddl.s8 q11, d0, d8 │ │ │ │ + vaddl.s8 q11, d0, d0 │ │ │ │ @ instruction: 0xf0030002 │ │ │ │ - stclvs 12, cr15, [r3, #316]! @ 0x13c │ │ │ │ - msrmi R12_usr, fp │ │ │ │ + stclvs 12, cr15, [r3, #300]! @ 0x12c │ │ │ │ + tstpmi ip, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ movwls r4, #50712 @ 0xc618 │ │ │ │ blx d137ea │ │ │ │ stmdacs r0, {r0, r1, r2, ip, pc} │ │ │ │ msrhi SPSR_c, #1 │ │ │ │ eorvs r6, r5, r3, ror #23 │ │ │ │ stcvs 1, cr11, [r3], #-12 │ │ │ │ @@ -4453,33 +4453,33 @@ │ │ │ │ svclt 0x0000e7cf │ │ │ │ andeq r0, r5, r8, asr r4 │ │ │ │ andeq r0, r5, r8, lsr #3 │ │ │ │ @ instruction: 0xa01cf8dd │ │ │ │ strtmi r2, [fp], r1, lsl #10 │ │ │ │ @ instruction: 0xf7fb4650 │ │ │ │ @ instruction: 0x4630ebfe │ │ │ │ - blx 17d18a0 │ │ │ │ + blx 16d18a0 │ │ │ │ movwls r1, #27011 @ 0x6983 │ │ │ │ stmdavs r3!, {r7, r9, sl, lr} │ │ │ │ blx 17b8d4 │ │ │ │ ldrbmi pc, [r5], -r3, lsl #6 @ │ │ │ │ movwls r3, #23297 @ 0x5b01 │ │ │ │ - stc2 0, cr15, [r6], {8} │ │ │ │ + stc2 0, cr15, [r2], {8} │ │ │ │ stmdavs r0!, {r1, r2, r3, ip, pc} │ │ │ │ ldrdeq r4, [r0], sl │ │ │ │ - blx 13518c4 │ │ │ │ + blx 12518c4 │ │ │ │ svcvs 0x00206060 │ │ │ │ @ instruction: 0xf0020080 │ │ │ │ - andcs pc, r0, #290816 @ 0x47000 │ │ │ │ + andcs pc, r0, #274432 @ 0x43000 │ │ │ │ strbvs r4, [r0, -r3, lsr #12]! │ │ │ │ - cmppvs ip, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + cmppvs r4, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ andls r4, r4, #20, 12 @ 0x1400000 │ │ │ │ @ instruction: 0xf64a910b │ │ │ │ - vmull.p8 q11, d16, d8 │ │ │ │ + vmull.p8 q11, d16, d0 │ │ │ │ ldrmi r0, [r9], r2, lsl #28 │ │ │ │ ldrdcs lr, [r1, -r5] │ │ │ │ @ instruction: 0xf8cd970a │ │ │ │ addmi lr, sl, #36 @ 0x24 │ │ │ │ @ instruction: 0x81bcf080 │ │ │ │ rsbvs r1, fp, r3, asr ip │ │ │ │ stmdacs r0!, {r4, fp, ip, sp, lr} │ │ │ │ @@ -4632,15 +4632,15 @@ │ │ │ │ svclt 0x0018280a │ │ │ │ svccc 0x00fff1b0 │ │ │ │ @ instruction: 0xf04fd1ef │ │ │ │ eorsvc r0, r3, r0, lsl #6 │ │ │ │ strcc r9, [r2, -r6, lsl #22] │ │ │ │ @ instruction: 0xf0c042bb │ │ │ │ ldrbmi r8, [r8], -pc, lsr #3 │ │ │ │ - blx b51b86 │ │ │ │ + blx a51b86 │ │ │ │ ldrsbtcc pc, [r0], #-137 @ 0xffffff77 @ │ │ │ │ strmi r9, [r6], -r4, lsl #20 │ │ │ │ @ instruction: 0xf0c14293 │ │ │ │ bcs 363b0 <__time64@plt+0x250c8> │ │ │ │ @ instruction: 0xf8d9d066 │ │ │ │ andcs r3, r0, r4, ror r0 │ │ │ │ tstpeq r7, r2, lsl r0 @ p-variant is OBSOLETE │ │ │ │ @@ -4707,15 +4707,15 @@ │ │ │ │ stmdacs r0!, {r1, r2, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ stmdacs sl, {r0, ip, lr, pc} │ │ │ │ ldmib r5, {r0, r2, r3, r8, ip, lr, pc}^ │ │ │ │ strb r3, [r9], -r1, lsl #2 │ │ │ │ strbmi r9, [r2], -r9, lsl #18 │ │ │ │ @ instruction: 0xf8cda80e │ │ │ │ @ instruction: 0xf002a03c │ │ │ │ - movwcs pc, #8111 @ 0x1faf @ │ │ │ │ + movwcs pc, #8107 @ 0x1fab @ │ │ │ │ movwls r4, #20667 @ 0x50bb │ │ │ │ mcrrne 7, 14, lr, r1, cr3 │ │ │ │ mcrge 4, 2, pc, cr8, cr15, {3} @ │ │ │ │ strtmi r4, [r1], fp, asr #12 │ │ │ │ blls 1a7514 │ │ │ │ svcls 0x000a9a04 │ │ │ │ @ instruction: 0xf0c04543 │ │ │ │ @@ -4809,15 +4809,15 @@ │ │ │ │ ldrmi r0, [sl, #2561] @ 0xa01 │ │ │ │ addhi pc, r9, r0, lsl #1 │ │ │ │ ldrsbtcc pc, [r4], #-137 @ 0xffffff77 @ │ │ │ │ eormi pc, sl, r3, asr r8 @ │ │ │ │ stccs 6, cr4, [r0], {32} │ │ │ │ stmdavs r3!, {r1, r3, r4, r6, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf0069304 │ │ │ │ - strmi pc, [r0], r5, lsl #29 │ │ │ │ + strmi pc, [r0], r1, lsl #29 │ │ │ │ @ instruction: 0x212fb390 │ │ │ │ @ instruction: 0xf7fb4640 │ │ │ │ stmdacs r0, {r1, r2, r4, r5, r7, r8, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf8d9d0e5 │ │ │ │ stccs 0, cr4, [r0], {-0} │ │ │ │ @ instruction: 0xf8d9d0e1 │ │ │ │ bl fe82de54 │ │ │ │ @@ -4833,82 +4833,82 @@ │ │ │ │ @ instruction: 0xf7fb4640 │ │ │ │ stmdacs r0, {r2, r4, r5, r6, r7, fp, sp, lr, pc} │ │ │ │ movwcs sp, #4589 @ 0x11ed │ │ │ │ blx fc688 │ │ │ │ andsmi pc, r3, #738197504 @ 0x2c000000 │ │ │ │ strtmi sp, [sl], -r1, asr #3 │ │ │ │ @ instruction: 0xf64a4641 │ │ │ │ - vaddl.s8 , d0, d4 │ │ │ │ + vshr.s64 q11, q14, #64 │ │ │ │ @ instruction: 0xf7fb0002 │ │ │ │ @ instruction: 0xe7b8fa95 │ │ │ │ stmdaeq r9, {r2, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0014640 │ │ │ │ - pkhbtmi pc, r0, fp, lsl #30 @ │ │ │ │ + pkhbtmi pc, r0, r7, lsl #30 @ │ │ │ │ @ instruction: 0xf04fe7c5 │ │ │ │ @ instruction: 0xf8060300 │ │ │ │ stmdbls fp, {r0, r8, r9, fp, ip, sp} │ │ │ │ stmdage lr, {r1, r6, r9, sl, lr} │ │ │ │ eorsge pc, ip, sp, asr #17 │ │ │ │ - cdp2 0, 9, cr15, cr12, cr2, {0} │ │ │ │ + cdp2 0, 9, cr15, cr8, cr2, {0} │ │ │ │ addsmi r9, lr, #6144 @ 0x1800 │ │ │ │ ldclge 6, cr15, [r8, #-508]! @ 0xfffffe04 │ │ │ │ - eorvs pc, r4, #77594624 @ 0x4a00000 │ │ │ │ + andsvs pc, ip, #77594624 @ 0x4a00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ cmnpne fp, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ blx ffed3ec0 │ │ │ │ - cdp2 0, 2, cr15, cr12, cr6, {0} │ │ │ │ + cdp2 0, 2, cr15, cr8, cr6, {0} │ │ │ │ stmdacs r0, {r7, r9, sl, lr} │ │ │ │ sbchi pc, r3, r0 │ │ │ │ str r9, [r2, r4, lsl #8]! │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ ldmdavs r3!, {r1, r3, r5, r6, r7, pc}^ │ │ │ │ b 10fc704 │ │ │ │ andsmi r0, r3, #524288 @ 0x80000 │ │ │ │ stccs 0, cr13, [r0], {19} │ │ │ │ sbcshi pc, ip, r0 │ │ │ │ orrmi pc, r0, #4, 2 │ │ │ │ ldrdne pc, [r4], -r9 │ │ │ │ @ instruction: 0xf8513b01 │ │ │ │ @ instruction: 0xf64a3023 │ │ │ │ - vaddw.s8 q11, q8, d20 │ │ │ │ + vsra.s64 d22, d12, #64 │ │ │ │ ldrbmi r0, [sl], -r2, lsl #2 │ │ │ │ @ instruction: 0xf8cda80e │ │ │ │ @ instruction: 0xf002a03c │ │ │ │ - rsbsvs pc, r7, r7, ror #28 │ │ │ │ + rsbsvs pc, r7, r3, ror #28 │ │ │ │ svcls 0x0005e69d │ │ │ │ blls 1e7858 │ │ │ │ @ instruction: 0xf013681b │ │ │ │ @ instruction: 0xf0400620 │ │ │ │ stmdals r7, {r0, r1, r3, r7, r8, r9, sl, pc} │ │ │ │ ldmdb ip!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ strvs r6, [r6, r2, lsr #30]! │ │ │ │ suble r2, r2, r0, lsl #20 │ │ │ │ ldmibcc r8, {r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - stmdane r0!, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmdane r8, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdaeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - bvc 195387c │ │ │ │ + bvc 175387c │ │ │ │ beq d2a58 │ │ │ │ strtmi lr, [r8], -fp │ │ │ │ ldmdb r8, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdble r2, {r2, fp, sp} │ │ │ │ blcs bb4014 │ │ │ │ svcvs 0x0022d01d │ │ │ │ adcsmi r3, r2, #1048576 @ 0x100000 │ │ │ │ svcvs 0x0063d929 │ │ │ │ eorpl pc, r6, r3, asr r8 @ │ │ │ │ strcc fp, [r9, #-261] @ 0xfffffefb │ │ │ │ @ instruction: 0xf00b4628 │ │ │ │ - stmiavs r3!, {r0, r2, r8, fp, ip, sp, lr, pc} │ │ │ │ + stmiavs r3!, {r0, r8, fp, ip, sp, lr, pc} │ │ │ │ rscle r2, r8, r0, lsl #22 │ │ │ │ ldrdlt pc, [r0], -r9 │ │ │ │ @ instruction: 0xf0014640 │ │ │ │ - @ instruction: 0x4651fe9f │ │ │ │ + @ instruction: 0x4651fe9b │ │ │ │ stmib sp, {r1, r9, sl, lr}^ │ │ │ │ ldrbmi r6, [r8], -r0, lsl #10 │ │ │ │ orrsmi pc, r1, #268435460 @ 0x10000004 │ │ │ │ stmdb r4, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdavc fp!, {r0, r3, r4, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ bicsle r2, lr, pc, lsr #22 │ │ │ │ @ instruction: 0xf8154405 │ │ │ │ @@ -4918,89 +4918,89 @@ │ │ │ │ svcvs 0x00a3bf02 │ │ │ │ strvs r3, [r3, r1, lsl #6]! │ │ │ │ stcvs 7, cr14, [r3], #836 @ 0x344 │ │ │ │ @ instruction: 0xdc282b00 │ │ │ │ blcs 3025c <__time64@plt+0x1ef74> │ │ │ │ ldmibge r4, {r0, r1, r2, r3, r4, r5, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf64a68e3 │ │ │ │ - vsubl.s8 , d16, d24 │ │ │ │ + vsubl.s8 , d16, d16 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d1, d2 │ │ │ │ @ instruction: 0xf002419f │ │ │ │ - @ instruction: 0xf7ffff6d │ │ │ │ + @ instruction: 0xf7ffff69 │ │ │ │ blls 184708 │ │ │ │ ldrmi r4, [fp], r1, asr #12 │ │ │ │ @ instruction: 0xf7fa6818 │ │ │ │ stmdacs r0, {r1, r2, r4, r5, r6, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ mrcge 4, 1, APSR_nzcv, cr14, cr15, {1} │ │ │ │ strbt r2, [pc], #1793 @ 16008 <__time64@plt+0x4d20> │ │ │ │ stmdage lr, {r1, r6, r9, sl, lr} │ │ │ │ - teqpvs r4, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + msrvs R12_fiq, sl │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ eorsge pc, ip, sp, asr #17 │ │ │ │ - stc2l 0, cr15, [r8, #8]! │ │ │ │ + stc2l 0, cr15, [r4, #8]! │ │ │ │ stmdbvs r3!, {r1, r6, r7, sl, sp, lr, pc} │ │ │ │ - addvc pc, r0, sl, asr #12 │ │ │ │ + rsbsvc pc, r8, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7fa6839 │ │ │ │ strb lr, [sp, ip, ror #31] │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf001681d │ │ │ │ - stclvs 14, cr15, [r3], #-276 @ 0xfffffeec │ │ │ │ + stclvs 14, cr15, [r3], #-260 @ 0xfffffefc │ │ │ │ strtmi r4, [r8], -r2, lsl #12 │ │ │ │ - cmppeq ip, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppeq r4, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stmib sp, {r0, r2, r3, r4, r6, fp, sp, lr}^ │ │ │ │ vrshl.s8 d19, d0, d1 │ │ │ │ @ instruction: 0xf7fb43bf │ │ │ │ @ instruction: 0xf7ffe8a6 │ │ │ │ @ instruction: 0x9004b9b8 │ │ │ │ @ instruction: 0x4628e714 │ │ │ │ stmia r6!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ vshl.s8 q15, q12, q0 │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ @ instruction: 0xf6480305 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf8d30002 │ │ │ │ @ instruction: 0xf0018000 │ │ │ │ - strmi pc, [r5], -r3, lsr #28 │ │ │ │ + @ instruction: 0x4605fe1f │ │ │ │ stmda lr!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmdage lr, {r1, r2, r9, sl, lr} │ │ │ │ ldm lr, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x53a3f44f │ │ │ │ andvs lr, r0, sp, asr #19 │ │ │ │ strbmi r4, [r0], -sl, lsr #12 │ │ │ │ - asrsmi pc, sl, #12 @ │ │ │ │ + @ instruction: 0x41a8f64a │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldmda lr!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ blt 1c540b0 │ │ │ │ mvncs pc, #77594624 @ 0x4a00000 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0xf64ae725 │ │ │ │ - vrshr.s64 q11, q4, #64 │ │ │ │ + vrshr.s64 q11, q0, #64 │ │ │ │ @ instruction: 0xf64a0202 │ │ │ │ - vmla.i d22, d16, d0[6] │ │ │ │ + vmla.i d22, d16, d0[4] │ │ │ │ cmncs lr, r2 │ │ │ │ @ instruction: 0xf9faf7fb │ │ │ │ ldrdcc pc, [r4], -r8 │ │ │ │ @ instruction: 0xf0804283 │ │ │ │ movwcc r8, #5516 @ 0x158c │ │ │ │ andcc pc, r4, r8, asr #17 │ │ │ │ @ instruction: 0xf7fb4640 │ │ │ │ stcvs 8, cr14, [r5, #656]! @ 0x290 │ │ │ │ ldmdavs r0!, {r0, r2, r6, r7, r8, ip, sp, pc}^ │ │ │ │ - stc2l 0, cr15, [lr, #4]! │ │ │ │ - tstpvs r8, #-1342177276 @ p-variant is OBSOLETE @ 0xb0000004 │ │ │ │ + stc2l 0, cr15, [sl, #4]! │ │ │ │ + tstpvs r0, #-1342177276 @ p-variant is OBSOLETE @ 0xb0000004 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ vmax.s8 d20, d11, d2 │ │ │ │ - vorr.i32 d22, #12 @ 0x0000000c │ │ │ │ + vorr.i32 d22, #4 @ 0x00000004 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ strls r2, [r0, #-1280] @ 0xfffffb00 │ │ │ │ @ instruction: 0xff5ef000 │ │ │ │ strmi r4, [r5], -r9, lsr #12 │ │ │ │ @ instruction: 0xf7fb6870 │ │ │ │ stmdacs r0, {r2, r7, fp, sp, lr, pc} │ │ │ │ ldrbhi pc, [r5, #-0] @ │ │ │ │ @@ -5017,122 +5017,122 @@ │ │ │ │ stmdacs r0, {r2, r4, r5, r6, fp, sp, lr, pc} │ │ │ │ strthi pc, [r5], r0, asr #32 │ │ │ │ @ instruction: 0xf1096ca3 │ │ │ │ blcs 5855c │ │ │ │ strhi pc, [sp, #-832]! @ 0xfffffcc0 │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ strls r8, [r0, #-1324] @ 0xfffffad4 │ │ │ │ - addsvs pc, r8, fp, asr #4 │ │ │ │ + addsvs pc, r0, fp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldmdavs r3!, {r0, r3, r4, r5, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7fa464a │ │ │ │ strtmi lr, [r8], -r8, asr #30 │ │ │ │ svc 0x0052f7fa │ │ │ │ @ instruction: 0xf7fa6930 │ │ │ │ movwcs lr, #3920 @ 0xf50 │ │ │ │ stmib r6, {r0, r1, r4, r5, r8, sp, lr}^ │ │ │ │ ldmdavs r6!, {r1, r8, r9, ip, sp} │ │ │ │ @ instruction: 0xf0402e00 │ │ │ │ stcvs 4, cr8, [r3], #908 @ 0x38c │ │ │ │ vstrle d2, [r7, #-0] │ │ │ │ - sbcsvs pc, ip, fp, asr #4 │ │ │ │ + sbcsvs pc, r4, fp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0x464a6839 │ │ │ │ svc 0x002ef7fa │ │ │ │ blcs 31638 <__time64@plt+0x20350> │ │ │ │ stmibge r5!, {r0, r1, r2, r3, r4, r5, sl, ip, sp, lr, pc}^ │ │ │ │ - stc2l 0, cr15, [r6], #8 │ │ │ │ + stc2l 0, cr15, [r2], #8 │ │ │ │ stmiblt r1!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ vst2. {d22-d23}, [pc :128], r3 │ │ │ │ vrhadd.s8 d21, d27, d23 │ │ │ │ - vrshr.s64 q8, q6, #64 │ │ │ │ + vrshr.s64 q8, q2, #64 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf0020002 │ │ │ │ - stcvc 14, cr15, [r3, #-492]! @ 0xfffffe14 │ │ │ │ + stcvc 14, cr15, [r3, #-476]! @ 0xfffffe24 │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ stmiavs r3!, {r0, r1, r2, r7, r9, sl, pc} │ │ │ │ @ instruction: 0xf43f2b00 │ │ │ │ vmla.i8 q13, q8, │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ @ instruction: 0xf6480305 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ ldmdavs sp, {r1} │ │ │ │ - stc2l 0, cr15, [ip, #-4]! │ │ │ │ + stc2l 0, cr15, [r8, #-4]! │ │ │ │ strmi r6, [r2], -r3, ror #28 │ │ │ │ strtmi r9, [r8], -r0, lsl #6 │ │ │ │ - msrne R12_usr, fp │ │ │ │ + tstpne ip, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mvnmi pc, #268435460 @ 0x10000004 │ │ │ │ svc 0x00cef7fa │ │ │ │ stmiblt ip!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fb4628 │ │ │ │ @ instruction: 0xf7ffe812 │ │ │ │ vpadd.i8 d27, d16, d30 │ │ │ │ @ instruction: 0xf2c034d8 │ │ │ │ strmi r0, [r3], -r5, lsl #8 │ │ │ │ @ instruction: 0xf64a683a │ │ │ │ - vmla.f d20, d0, d0[3] │ │ │ │ + vmla.f d20, d0, d0[1] │ │ │ │ stmdavs r0!, {r1, r8} │ │ │ │ svc 0x00baf7fa │ │ │ │ - @ instruction: 0xf968f002 │ │ │ │ - rsbmi pc, r4, sl, asr #12 │ │ │ │ + @ instruction: 0xf964f002 │ │ │ │ + subsmi pc, ip, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf8e8f7fb │ │ │ │ @ instruction: 0xf7ff46c1 │ │ │ │ @ instruction: 0x6c23b958 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ blvs ff8f6be4 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ @ instruction: 0xf8d4825f │ │ │ │ @ instruction: 0xf1b88044 │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ stmiavs r3!, {r0, r4, r8, sl, pc} │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ bmi fe57780c │ │ │ │ stmiavs r1!, {r6, r9, sl, lr}^ │ │ │ │ - stc2 0, cr15, [r2, #-28] @ 0xffffffe4 │ │ │ │ + ldc2l 0, cr15, [lr], #28 │ │ │ │ blcs 3120c <__time64@plt+0x1ff24> │ │ │ │ strhi pc, [r8, #-0] │ │ │ │ @ instruction: 0xf6486be2 │ │ │ │ - vqdmlal.s , d16, d20 │ │ │ │ + @ instruction: 0xf2c0799c │ │ │ │ bvs 8d8698 │ │ │ │ blx fecbaabc │ │ │ │ ldrmi pc, [sl], r2, lsl #5 │ │ │ │ ldmdbeq r2, {r8, sp}^ │ │ │ │ tstls r5, r9, lsl #6 │ │ │ │ stmib sp, {r3, r9, ip, pc}^ │ │ │ │ @ instruction: 0xf1ba740b │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ @ instruction: 0xf8da809b │ │ │ │ @ instruction: 0xf006000c │ │ │ │ - @ instruction: 0xf8dafe17 │ │ │ │ + @ instruction: 0xf8dafe13 │ │ │ │ @ instruction: 0x46046014 │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ movwcs r8, #555 @ 0x22b │ │ │ │ - msrcc (UNDEF: 100), fp │ │ │ │ + cmppcc ip, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blcc 1652bfc │ │ │ │ + blcc 1452bfc │ │ │ │ bleq d2dd4 │ │ │ │ @ instruction: 0x460f4698 │ │ │ │ movwls r9, #16391 @ 0x4007 │ │ │ │ @ instruction: 0x4639e01b │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ lsllt lr, r2, #29 │ │ │ │ vmax.s8 d20, d9, d16 │ │ │ │ - vsra.s64 q10, q10, #64 │ │ │ │ + vmla.f d20, d16, d0[7] │ │ │ │ @ instruction: 0xf7fa0102 │ │ │ │ @ instruction: 0xf8daee7a │ │ │ │ stmdacs r0, {r2, sp} │ │ │ │ @ instruction: 0x4613d157 │ │ │ │ - msrcc (UNDEF: 108), fp │ │ │ │ + msrcc (UNDEF: 100), fp │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf10a4622 │ │ │ │ @ instruction: 0xf002000c │ │ │ │ - ldmdavs r6!, {r0, r2, r3, r5, r6, sl, fp, ip, sp, lr, pc} │ │ │ │ + ldmdavs r6!, {r0, r3, r5, r6, sl, fp, ip, sp, lr, pc} │ │ │ │ ldmdavs r4!, {r1, r2, r4, r5, r7, r8, ip, sp, pc}^ │ │ │ │ strtmi r4, [r0], -r9, asr #12 │ │ │ │ mcr 7, 3, pc, cr4, cr10, {7} @ │ │ │ │ ldmvs r3!, {r3, r5, r8, fp, ip, sp, pc} │ │ │ │ svclt 0x00042b01 │ │ │ │ movwls r6, #18675 @ 0x48f3 │ │ │ │ @ instruction: 0x4659d0f1 │ │ │ │ @@ -5147,61 +5147,61 @@ │ │ │ │ smladcs r1, r8, pc, fp @ │ │ │ │ adcmi r6, r1, #13697024 @ 0xd10000 │ │ │ │ movwcs fp, #3860 @ 0xf14 │ │ │ │ movweq pc, #4103 @ 0x1007 @ │ │ │ │ ldmdavs r2, {r0, r1, r3, r6, r7, r8, fp, ip, sp, pc} │ │ │ │ mvnsle r2, r0, lsl #20 │ │ │ │ @ instruction: 0xf0012010 │ │ │ │ - @ instruction: 0xf8dafcf3 │ │ │ │ + @ instruction: 0xf8dafcef │ │ │ │ blls 15e3a4 │ │ │ │ andvs r4, r3, r7, lsl #12 │ │ │ │ sbcvs r2, r4, r0, lsl #6 │ │ │ │ addvs r6, r2, r3, asr #32 │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ strtmi r8, [r0], -r5, lsr #11 │ │ │ │ - biccc pc, r8, fp, asr #4 │ │ │ │ + biccc pc, r0, fp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - @ instruction: 0xf9eef004 │ │ │ │ + @ instruction: 0xf9eaf004 │ │ │ │ @ instruction: 0xf1b89705 │ │ │ │ tstle r5, r0, lsl #30 │ │ │ │ @ instruction: 0xf8dab126 │ │ │ │ ldmdavs r1, {r3, sp} │ │ │ │ andle r2, ip, r6, lsl #18 │ │ │ │ ldrdge pc, [r0], -sl │ │ │ │ @ instruction: 0x4623e77b │ │ │ │ andeq pc, ip, sl, lsl #2 │ │ │ │ - orrscc pc, r8, fp, asr #4 │ │ │ │ + orrscc pc, r0, fp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldc2 0, cr15, [r6], {2} │ │ │ │ + ldc2 0, cr15, [r2], {2} │ │ │ │ ldmdbvs r2, {r0, r1, r2, r5, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0226812 │ │ │ │ bcs 116bd4 │ │ │ │ ldrbmi sp, [r1], -ip, ror #3 │ │ │ │ bmi f67c54 │ │ │ │ - blx fe0523f0 │ │ │ │ + blx 1f523f0 │ │ │ │ @ instruction: 0x46204a3c │ │ │ │ @ instruction: 0xf0064651 │ │ │ │ - @ instruction: 0xe7e1fa7b │ │ │ │ + @ instruction: 0xe7e1fa77 │ │ │ │ ldrdls pc, [r4], -sp @ │ │ │ │ - stmiavc r4!, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmvc ip, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdaeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - bicscc pc, ip, fp, asr #4 │ │ │ │ + bicscc pc, r4, fp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - stcmi 2, cr15, [ip], {75} @ 0x4b │ │ │ │ + stcmi 2, cr15, [r4], {75} @ 0x4b │ │ │ │ stceq 2, cr15, [r2], {192} @ 0xc0 │ │ │ │ eorsgt pc, r4, sp, asr #17 │ │ │ │ strvc lr, [fp], #-2525 @ 0xfffff623 │ │ │ │ strbmi r9, [pc], -r7, lsl #14 │ │ │ │ smlabtmi fp, sp, r9, lr │ │ │ │ subsle r2, sp, r0, lsl #30 │ │ │ │ @ instruction: 0xf00668f8 │ │ │ │ - ldmdbvs lr!, {r0, r2, r5, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmdbvs lr!, {r0, r5, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ teqlt r6, #137363456 @ 0x8300000 │ │ │ │ stmdbeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ - cmppcc r8, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppcc r0, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0x46ca4634 │ │ │ │ strls r4, [r4, -lr, lsl #12] │ │ │ │ ldrtmi lr, [r8], -r9 │ │ │ │ @ instruction: 0xf7fa4631 │ │ │ │ stmdavs r4!, {r1, r2, r4, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ svclt 0x00082800 │ │ │ │ @@ -5222,47 +5222,47 @@ │ │ │ │ stmdbcs r0, {r0, r3, fp, sp, lr} │ │ │ │ ldrbhi pc, [r3, #-0] @ │ │ │ │ ldrmi r6, [fp, #2251] @ 0x8cb │ │ │ │ stmdavs r8, {r3, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ andcs fp, r1, r8, ror #18 │ │ │ │ stmdbls ip, {r3, r6, sp, lr} │ │ │ │ @ instruction: 0xf0044658 │ │ │ │ - ldmvs r9!, {r0, r1, r3, r5, r6, r8, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmvs r9!, {r0, r1, r2, r5, r6, r8, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0064658 │ │ │ │ - stmdbls sp, {r0, r2, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + stmdbls sp, {r0, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0044658 │ │ │ │ - blls 254a38 │ │ │ │ + blls 254a28 │ │ │ │ movwls r4, #9816 @ 0x2658 │ │ │ │ movweq pc, #49415 @ 0xc107 @ │ │ │ │ andls pc, r0, sp, asr #17 │ │ │ │ movwls r4, #5689 @ 0x1639 │ │ │ │ andcc lr, r1, #3522560 @ 0x35c000 │ │ │ │ - blx 3d24d4 │ │ │ │ + blx 2d24d4 │ │ │ │ svclt 0x0000e7d1 │ │ │ │ - ldrdeq lr, [r2], -r4 │ │ │ │ - strdeq lr, [r2], -r0 │ │ │ │ + andeq lr, r2, ip, asr #31 │ │ │ │ + andeq lr, r2, r8, ror #31 │ │ │ │ vadd.i8 d25, d11, d5 │ │ │ │ - vmov.i32 d20, #1024 @ 0x00000400 │ │ │ │ + vsubl.s8 q10, d0, d12 │ │ │ │ vhsub.s8 d16, d11, d2 │ │ │ │ - vaddw.s8 q10, q0, d16 │ │ │ │ + vorr.i32 d20, #8 @ 0x00000008 │ │ │ │ svcls 0x00070102 │ │ │ │ @ instruction: 0xf0069c0b │ │ │ │ - @ instruction: 0xf8ddff85 │ │ │ │ + @ instruction: 0xf8ddff81 │ │ │ │ vhadd.s8 d25, d11, d20 │ │ │ │ - vorr.i32 q10, #2048 @ 0x00000800 │ │ │ │ + vorr.i32 q10, #0 @ 0x00000000 │ │ │ │ vcgt.s8 d16, d11, d2 │ │ │ │ - vsubl.s8 q10, d0, d24 │ │ │ │ + vsubl.s8 q10, d0, d16 │ │ │ │ strbmi r0, [lr], -r2, lsl #4 │ │ │ │ - ldmdacc r8, {r0, r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ + ldmdacc r0, {r0, r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdaeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x46924699 │ │ │ │ strls r9, [r7], #-1796 @ 0xfffff8fc │ │ │ │ eorsle r2, lr, r0, lsl #28 │ │ │ │ @ instruction: 0xf00668f0 │ │ │ │ - ldmdbvs r4!, {r0, r2, r5, r6, r7, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmdbvs r4!, {r0, r5, r6, r7, sl, fp, ip, sp, lr, pc}^ │ │ │ │ stccs 6, cr4, [r0], {7} │ │ │ │ @ instruction: 0xf04fd035 │ │ │ │ stmdavs r0!, {r0, r8, r9, fp}^ │ │ │ │ @ instruction: 0xf7fa4641 │ │ │ │ stmdavs r4!, {r1, r2, r3, r4, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ svclt 0x000c2800 │ │ │ │ bleq 52674 │ │ │ │ @@ -5274,44 +5274,44 @@ │ │ │ │ ldmdavs fp, {r1, r2, r3, r5, r6, r7, sl, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ ldmvs sl, {r1, r3, r5, r6, r7, sl, pc}^ │ │ │ │ @ instruction: 0xd1f84297 │ │ │ │ stmiblt r2, {r1, r3, r4, r6, fp, sp, lr} │ │ │ │ ldrbmi r2, [r1], -r1, lsl #4 │ │ │ │ subsvs r4, sl, r8, lsr r6 │ │ │ │ - @ instruction: 0xf902f004 │ │ │ │ + @ instruction: 0xf8fef004 │ │ │ │ @ instruction: 0x463868f1 │ │ │ │ - @ instruction: 0xff1cf006 │ │ │ │ - tstpmi ip, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + @ instruction: 0xff18f006 │ │ │ │ + tstpmi r4, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf0044638 │ │ │ │ - ldmdavs r3!, {r0, r1, r2, r4, r5, r6, r7, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmdavs r3!, {r0, r1, r4, r5, r6, r7, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x46494638 │ │ │ │ @ instruction: 0xf004461a │ │ │ │ - ldmdavs r6!, {r0, r4, r5, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ + ldmdavs r6!, {r0, r2, r3, r5, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ mcrls 7, 0, lr, cr5, cr14, {5} │ │ │ │ - addmi pc, r0, #-1342177276 @ 0xb0000004 │ │ │ │ + rsbsmi pc, r8, #-1342177276 @ 0xb0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - orrsmi pc, r8, fp, asr #4 │ │ │ │ + orrsmi pc, r0, fp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ svcls 0x00044630 │ │ │ │ - stmdacc r4!, {r0, r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ + ldmdacc ip, {r0, r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdaeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0069c07 │ │ │ │ - @ instruction: 0xf8ddff1f │ │ │ │ + @ instruction: 0xf8ddff1b │ │ │ │ vhadd.s8 d25, d11, d20 │ │ │ │ - vrshr.s64 d20, d24, #64 │ │ │ │ + vrshr.s64 d20, d16, #64 │ │ │ │ strls r0, [r4, -r2, lsl #4] │ │ │ │ strls r4, [r7], #-1682 @ 0xfffff96e │ │ │ │ ldrtmi r4, [r4], -pc, asr #12 │ │ │ │ - asrmi pc, fp, #4 @ │ │ │ │ + orrsmi pc, r8, fp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ svccs 0x00009108 │ │ │ │ ldmvs r8!, {r2, r3, r4, r5, ip, lr, pc}^ │ │ │ │ - stc2 0, cr15, [r2], {6} │ │ │ │ + ldc2l 0, cr15, [lr], #-24 @ 0xffffffe8 │ │ │ │ @ instruction: 0x4681697e │ │ │ │ eorsle r2, r3, r0, lsl #28 │ │ │ │ bleq 52728 │ │ │ │ @ instruction: 0x46416870 │ │ │ │ ldcl 7, cr15, [sl], #1000 @ 0x3e8 │ │ │ │ stmdacs r0, {r1, r2, r4, r5, fp, sp, lr} │ │ │ │ @ instruction: 0xf04bbf08 │ │ │ │ @@ -5323,38 +5323,38 @@ │ │ │ │ ldmdavs r2, {r0, r1, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ ldmvs r3, {r3, r7, sl, pc}^ │ │ │ │ @ instruction: 0xd1f84599 │ │ │ │ stmiblt r1, {r0, r4, r6, fp, sp, lr} │ │ │ │ strbmi r2, [r8], -r1, lsl #2 │ │ │ │ stmdbls r8, {r0, r4, r6, sp, lr} │ │ │ │ - @ instruction: 0xf8a0f004 │ │ │ │ + @ instruction: 0xf89cf004 │ │ │ │ @ instruction: 0x464868f9 │ │ │ │ - cdp2 0, 11, cr15, cr10, cr6, {0} │ │ │ │ - tstppl r0, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cdp2 0, 11, cr15, cr6, cr6, {0} │ │ │ │ + tstppl r8, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf0044648 │ │ │ │ - ldmdavs sl!, {r0, r2, r4, r7, fp, ip, sp, lr, pc}^ │ │ │ │ + ldmdavs sl!, {r0, r4, r7, fp, ip, sp, lr, pc}^ │ │ │ │ ldrbmi r4, [r1], -r8, asr #12 │ │ │ │ - @ instruction: 0xf890f004 │ │ │ │ + @ instruction: 0xf88cf004 │ │ │ │ @ instruction: 0xe7c0683f │ │ │ │ @ instruction: 0x8014f8dd │ │ │ │ - ldmdbeq r0, {r1, r3, r6, r9, ip, sp, lr, pc} │ │ │ │ + stmdbeq r8, {r1, r3, r6, r9, ip, sp, lr, pc} │ │ │ │ stmdbeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ stcls 15, cr9, [r7], {4} │ │ │ │ cmplt r6, r6, asr #12 │ │ │ │ stmdblt fp, {r0, r1, r4, r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0xe7fa6836 │ │ │ │ @ instruction: 0x464968f0 │ │ │ │ - @ instruction: 0xf87cf004 │ │ │ │ + @ instruction: 0xf878f004 │ │ │ │ @ instruction: 0xf8dde7f8 │ │ │ │ @ instruction: 0x46238014 │ │ │ │ - bicsmi pc, r4, fp, asr #4 │ │ │ │ + bicmi pc, ip, fp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - rscsmi pc, r4, #-1342177276 @ 0xb0000004 │ │ │ │ + rscmi pc, ip, #-1342177276 @ 0xb0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ strmi r4, [sl], r4, asr #12 │ │ │ │ @ instruction: 0x46984693 │ │ │ │ stmdavs r4!, {sp, lr, pc} │ │ │ │ ldrsbtcc pc, [r4], -r8 @ │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ blcs 37218 <__time64@plt+0x25f30> │ │ │ │ @@ -5366,91 +5366,91 @@ │ │ │ │ @ instruction: 0xf04fd0ed │ │ │ │ and r0, r2, r0, lsl #18 │ │ │ │ @ instruction: 0xf1090876 │ │ │ │ ldrbeq r0, [r1, r4, lsl #18]! │ │ │ │ @ instruction: 0xf8d8d5fa │ │ │ │ @ instruction: 0x46513034 │ │ │ │ andeq pc, r9, r3, asr r8 @ │ │ │ │ - @ instruction: 0xf84af004 │ │ │ │ + @ instruction: 0xf846f004 │ │ │ │ ldrsbtcc pc, [r4], -r8 @ │ │ │ │ @ instruction: 0xf85368a1 │ │ │ │ @ instruction: 0xf0060009 │ │ │ │ - @ instruction: 0xf8d8fe61 │ │ │ │ + @ instruction: 0xf8d8fe5d │ │ │ │ @ instruction: 0x46593034 │ │ │ │ andeq pc, r9, r3, asr r8 @ │ │ │ │ - @ instruction: 0xf83cf004 │ │ │ │ + @ instruction: 0xf838f004 │ │ │ │ mvnle r0, r6, ror r8 │ │ │ │ bl 90634 │ │ │ │ bl 197334 │ │ │ │ @ instruction: 0xf8560c85 │ │ │ │ @ instruction: 0xf8431b04 │ │ │ │ strbmi r1, [r6, #-2820]! @ 0xfffff4fc │ │ │ │ strtmi sp, [sl], #-505 @ 0xfffffe07 │ │ │ │ bllt 1b54714 │ │ │ │ @ instruction: 0xe61646b0 │ │ │ │ - cmppne r4, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpne ip, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - subseq pc, r8, fp, asr #4 │ │ │ │ + subseq pc, r0, fp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - @ instruction: 0xff74f004 │ │ │ │ + @ instruction: 0xff70f004 │ │ │ │ rsceq pc, r4, #196, 16 @ 0xc40000 │ │ │ │ vadd.i8 d22, d11, d16 │ │ │ │ - vmov.i16 , #1024 @ 0x0400 │ │ │ │ + vmull.s , d0, d0[3] │ │ │ │ @ instruction: 0xf04f0a02 │ │ │ │ addeq r0, r0, r0, lsl #16 │ │ │ │ - blx 1d274e │ │ │ │ + blx d274e │ │ │ │ and r6, pc, r0, ror #6 │ │ │ │ ldrbmi r6, [r0], -r3, ror #16 │ │ │ │ eorvs pc, r8, r3, asr r8 @ │ │ │ │ @ instruction: 0xf0114631 │ │ │ │ - strmi pc, [r1], -r3, asr #16 │ │ │ │ + @ instruction: 0x4601f83f │ │ │ │ blvs 19a8020 │ │ │ │ - @ instruction: 0xff5af004 │ │ │ │ + @ instruction: 0xff56f004 │ │ │ │ eoreq pc, r8, r6, asr #16 │ │ │ │ stmdaeq r1, {r3, r8, ip, sp, lr, pc} │ │ │ │ ldrmi r6, [r8, #2083] @ 0x823 │ │ │ │ vcgt.s8 , q13, q14 │ │ │ │ - vbic.i32 d18, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d18, #4 @ 0x00000004 │ │ │ │ vrhadd.s8 d16, d11, d2 │ │ │ │ - vmov.i32 q8, #8 @ 0x00000008 │ │ │ │ + vmov.i32 q8, #0 @ 0x00000000 │ │ │ │ vhadd.s8 d16, d11, d2 │ │ │ │ - vmull.s , d0, d0[4] │ │ │ │ + vmov.i16 , #2048 @ 0x0800 │ │ │ │ @ instruction: 0xf0040a02 │ │ │ │ - @ instruction: 0xf8dfff45 │ │ │ │ + @ instruction: 0xf8dfff41 │ │ │ │ @ instruction: 0x46818838 │ │ │ │ ldrbmi lr, [r1], -r3 │ │ │ │ @ instruction: 0xf0034648 │ │ │ │ - @ instruction: 0xf858ffe9 │ │ │ │ + @ instruction: 0xf858ffe5 │ │ │ │ bcs 213b4 <__time64@plt+0x100cc> │ │ │ │ vand , , │ │ │ │ - vmull.s , d0, d0[4] │ │ │ │ + vmov.i16 , #2048 @ 0x0800 │ │ │ │ ldrmi r0, [r0], r2, lsl #20 │ │ │ │ @ instruction: 0xf8d4e009 │ │ │ │ ldrbmi r3, [r1], -r8, ror #5 │ │ │ │ @ instruction: 0xf8534648 │ │ │ │ @ instruction: 0xf1082028 │ │ │ │ @ instruction: 0xf0030801 │ │ │ │ - svcvs 0x00a3ffd5 │ │ │ │ + svcvs 0x00a3ffd1 │ │ │ │ blle ffca7e2c │ │ │ │ vmax.s8 q10, , q4 │ │ │ │ - vbic.i32 , #0 @ 0x00000000 │ │ │ │ + vmla.f d17, d0, d0[6] │ │ │ │ @ instruction: 0xf0030102 │ │ │ │ - strbmi pc, [r8], -fp, asr #31 @ │ │ │ │ - orrsne pc, r8, fp, asr #4 │ │ │ │ + strbmi pc, [r8], -r7, asr #31 @ │ │ │ │ + orrsne pc, r0, fp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - @ instruction: 0xffc4f003 │ │ │ │ + @ instruction: 0xffc0f003 │ │ │ │ vmax.s8 q10, , q4 │ │ │ │ - vaddw.s8 , q8, d24 │ │ │ │ + vaddw.s8 , q8, d16 │ │ │ │ @ instruction: 0xf0030102 │ │ │ │ - ldr pc, [r2, #-4029]! @ 0xfffff043 │ │ │ │ + ldr pc, [r2, #-4025]! @ 0xfffff047 │ │ │ │ @ instruction: 0xf8dd4644 │ │ │ │ vqadd.s8 d24, d11, d4 │ │ │ │ - vorr.i32 d21, #8 @ 0x00000008 │ │ │ │ + vorr.i32 d21, #0 @ 0x00000000 │ │ │ │ vrhadd.s8 d16, d11, d2 │ │ │ │ - @ instruction: 0xf2c049f4 │ │ │ │ + vmul.f d20, d16, d0[7] │ │ │ │ strls r0, [r4, -r2, lsl #18] │ │ │ │ bleq 52950 │ │ │ │ strtmi r4, [r0], r7, asr #12 │ │ │ │ svccs 0x0000460c │ │ │ │ ldmdavs fp!, {r0, r4, r5, ip, lr, pc}^ │ │ │ │ ldmdavs pc!, {r0, r1, r3, r8, fp, ip, sp, pc} @ │ │ │ │ ldmvs fp!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ @@ -5464,44 +5464,44 @@ │ │ │ │ @ instruction: 0xf8d8e007 │ │ │ │ @ instruction: 0xf10a3034 │ │ │ │ ldmdaeq r6!, {r2, r9, fp}^ │ │ │ │ blcs 4abf0 <__time64@plt+0x39908> │ │ │ │ ldrbeq sp, [r2, r5, ror #1]! │ │ │ │ @ instruction: 0xf853d5f5 │ │ │ │ strtmi r0, [r1], -sl │ │ │ │ - @ instruction: 0xff86f003 │ │ │ │ + @ instruction: 0xff82f003 │ │ │ │ ldrsbtcc pc, [r4], -r8 @ │ │ │ │ @ instruction: 0xf85368b9 │ │ │ │ @ instruction: 0xf006000a │ │ │ │ - @ instruction: 0xf8d8fd9d │ │ │ │ + @ instruction: 0xf8d8fd99 │ │ │ │ @ instruction: 0x46493034 │ │ │ │ andeq pc, sl, r3, asr r8 @ │ │ │ │ - @ instruction: 0xff78f003 │ │ │ │ + @ instruction: 0xff74f003 │ │ │ │ strbmi lr, [r4], -r1, ror #15 │ │ │ │ - stmibvc r8!, {r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ + stmibvc r0!, {r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ svcls 0x000446b8 │ │ │ │ stmdavs r2!, {r0, r3, sp, lr, pc} │ │ │ │ andle r4, r9, #144, 10 @ 0x24000000 │ │ │ │ eoreq pc, r8, r3, asr r8 @ │ │ │ │ stmdaeq r1, {r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0034649 │ │ │ │ - blvs 191663c │ │ │ │ + blvs 191662c │ │ │ │ mvnsle r2, r0, lsl #22 │ │ │ │ blcs 3d4d8 <__time64@plt+0x2c1f0> │ │ │ │ ssatmi sp, #4, r1, asr #2 │ │ │ │ @ instruction: 0x8014f8dd │ │ │ │ @ instruction: 0xf24b9c09 │ │ │ │ - vorr.i16 , #8 @ 0x0008 │ │ │ │ + vorr.i16 , #0 @ 0x0000 │ │ │ │ vmla.i8 d16, d11, d2 │ │ │ │ - vmov.i16 q10, #2048 @ 0x0800 │ │ │ │ + vmov.i16 q10, #0 @ 0x0000 │ │ │ │ strls r0, [r4, -r2, lsl #20] │ │ │ │ eorsle r2, r5, r0, lsl #24 │ │ │ │ @ instruction: 0xf00668e0 │ │ │ │ - stmdbvs r7!, {r0, r1, r2, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ + stmdbvs r7!, {r0, r1, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ ldmdblt r7, {r1, r2, r9, sl, lr} │ │ │ │ ldmdavs pc!, {r0, r3, sp, lr, pc} @ │ │ │ │ ldmdavs r8!, {r0, r1, r2, r3, r4, r5, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7fa4649 │ │ │ │ stmdacs r0, {r7, r8, r9, fp, sp, lr, pc} │ │ │ │ stmdavs r4!, {r0, r1, r2, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ stmiavs r2!, {r2, r3, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ @@ -5519,147 +5519,147 @@ │ │ │ │ andeq r6, r1, fp, ror #17 │ │ │ │ blcs 28234 <__time64@plt+0x16f4c> │ │ │ │ rscshi pc, r1, #0 │ │ │ │ addsmi r6, r6, #14286848 @ 0xda0000 │ │ │ │ cmnphi r8, r0 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xe7f6681b │ │ │ │ @ instruction: 0xe7db6952 │ │ │ │ - subspl pc, ip, #-1342177276 @ 0xb0000004 │ │ │ │ + subspl pc, r4, #-1342177276 @ 0xb0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - cmnppl r0, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + msrpl (UNDEF: 104), fp │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrbmi r9, [ip], -r5, lsl #16 │ │ │ │ @ instruction: 0xf0069f04 │ │ │ │ - andcs pc, r0, pc, asr #26 │ │ │ │ - blx ff152974 │ │ │ │ + andcs pc, r0, fp, asr #26 │ │ │ │ + blx ff052974 │ │ │ │ stmdacs r0, {r7, r9, sl, lr} │ │ │ │ rschi pc, r6, r0 │ │ │ │ - cmnppl r8, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmnppl r0, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - @ instruction: 0xff00f003 │ │ │ │ + cdp2 0, 15, cr15, cr12, cr3, {0} │ │ │ │ vmax.s8 q10, , q0 │ │ │ │ - vaddw.s8 , q8, d24 │ │ │ │ + vaddw.s8 , q8, d16 │ │ │ │ @ instruction: 0xf0030102 │ │ │ │ - blls 1d6564 │ │ │ │ - stmibpl ip!, {r0, r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ + blls 1d6554 │ │ │ │ + stmibpl r4!, {r0, r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ vpmax.s8 , , │ │ │ │ - vmull.s , d16, d0[5] │ │ │ │ + @ instruction: 0xf2c05adc │ │ │ │ blcc 11919c │ │ │ │ movwcc r0, #6299 @ 0x189b │ │ │ │ movweq pc, #28691 @ 0x7013 @ │ │ │ │ blcs 8ab0c │ │ │ │ blcs caad0 │ │ │ │ blcs 10aaa0 │ │ │ │ blcs 14aa70 │ │ │ │ blcs 18aa40 │ │ │ │ blcs 1caa10 │ │ │ │ blls 1ca9e0 │ │ │ │ svccs 0x0004f853 │ │ │ │ mrrcne 3, 0, r9, r1, cr6 │ │ │ │ eorshi pc, sp, #0 │ │ │ │ strbmi r4, [r0], -r9, asr #12 │ │ │ │ - cdp2 0, 13, cr15, cr2, cr3, {0} │ │ │ │ + cdp2 0, 12, cr15, cr14, cr3, {0} │ │ │ │ @ instruction: 0xf8539b06 │ │ │ │ movwls r2, #28420 @ 0x6f04 │ │ │ │ @ instruction: 0xf0001c53 │ │ │ │ @ instruction: 0x464981fd │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - blls 1d6500 │ │ │ │ + blls 1d64f0 │ │ │ │ svccs 0x0004f853 │ │ │ │ mrrcne 3, 0, r9, r6, cr6 │ │ │ │ mvnhi pc, r0 │ │ │ │ strbmi r4, [r0], -r9, asr #12 │ │ │ │ - cdp2 0, 11, cr15, cr12, cr3, {0} │ │ │ │ + cdp2 0, 11, cr15, cr8, cr3, {0} │ │ │ │ @ instruction: 0xf8539b06 │ │ │ │ movwls r2, #28420 @ 0x6f04 │ │ │ │ @ instruction: 0xf0001c50 │ │ │ │ @ instruction: 0x464981dd │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - blls 1d64d4 │ │ │ │ + blls 1d64c4 │ │ │ │ svccs 0x0004f853 │ │ │ │ mrrcne 3, 0, r9, r1, cr6 │ │ │ │ bichi pc, sp, r0 │ │ │ │ strbmi r4, [r0], -r9, asr #12 │ │ │ │ - cdp2 0, 10, cr15, cr6, cr3, {0} │ │ │ │ + cdp2 0, 10, cr15, cr2, cr3, {0} │ │ │ │ @ instruction: 0xf8539b06 │ │ │ │ movwls r2, #28420 @ 0x6f04 │ │ │ │ @ instruction: 0xf0001c53 │ │ │ │ @ instruction: 0x4649819f │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - blls 1d64a8 │ │ │ │ + blls 1d6498 │ │ │ │ svccs 0x0004f853 │ │ │ │ mrrcne 3, 0, r9, r6, cr6 │ │ │ │ orrhi pc, pc, r0 │ │ │ │ strbmi r4, [r0], -r9, asr #12 │ │ │ │ - cdp2 0, 9, cr15, cr0, cr3, {0} │ │ │ │ + cdp2 0, 8, cr15, cr12, cr3, {0} │ │ │ │ addsmi r9, sp, #6144 @ 0x1800 │ │ │ │ cdpls 0, 0, cr13, cr6, cr5, {3} │ │ │ │ @ instruction: 0x4649e030 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - ldmvs r2!, {r0, r1, r2, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + ldmvs r2!, {r0, r1, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ subsle r1, r7, r0, asr ip │ │ │ │ strbmi r4, [r0], -r9, asr #12 │ │ │ │ - cdp2 0, 8, cr15, cr0, cr3, {0} │ │ │ │ + cdp2 0, 7, cr15, cr12, cr3, {0} │ │ │ │ mrrcne 8, 15, r6, r1, cr2 │ │ │ │ strbmi sp, [r9], -fp, asr #32 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - ldmdbvs r2!, {r0, r3, r4, r5, r6, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + ldmdbvs r2!, {r0, r2, r4, r5, r6, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ eorsle r1, pc, r3, asr ip @ │ │ │ │ strbmi r4, [r0], -r9, asr #12 │ │ │ │ - cdp2 0, 7, cr15, cr2, cr3, {0} │ │ │ │ + cdp2 0, 6, cr15, cr14, cr3, {0} │ │ │ │ mrrcne 9, 7, r6, r0, cr2 @ │ │ │ │ @ instruction: 0x4649d033 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - ldmibvs r2!, {r0, r1, r3, r5, r6, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + ldmibvs r2!, {r0, r1, r2, r5, r6, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ eorle r1, r7, r1, asr ip │ │ │ │ strbmi r4, [r0], -r9, asr #12 │ │ │ │ - cdp2 0, 6, cr15, cr4, cr3, {0} │ │ │ │ + cdp2 0, 6, cr15, cr0, cr3, {0} │ │ │ │ @ instruction: 0x361c69f2 │ │ │ │ andsle r1, sl, r3, asr ip │ │ │ │ strbmi r4, [r0], -r9, asr #12 │ │ │ │ - cdp2 0, 5, cr15, cr12, cr3, {0} │ │ │ │ + cdp2 0, 5, cr15, cr8, cr3, {0} │ │ │ │ ldrhtle r4, [r2], -r5 │ │ │ │ @ instruction: 0x36046872 │ │ │ │ andle r1, fp, r0, asr ip │ │ │ │ strbmi r4, [r0], -r9, asr #12 │ │ │ │ - cdp2 0, 5, cr15, cr2, cr3, {0} │ │ │ │ + cdp2 0, 4, cr15, cr14, cr3, {0} │ │ │ │ mrrcne 8, 7, r6, r1, cr2 │ │ │ │ ldrbmi sp, [r1], -r3, asr #3 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - strb pc, [r2, fp, asr #28] @ │ │ │ │ + strb pc, [r2, r7, asr #28] @ │ │ │ │ @ instruction: 0x46404651 │ │ │ │ - cdp2 0, 4, cr15, cr6, cr3, {0} │ │ │ │ + cdp2 0, 4, cr15, cr2, cr3, {0} │ │ │ │ @ instruction: 0x4651e7f2 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - strb pc, [r3, r1, asr #28]! @ │ │ │ │ + @ instruction: 0xe7e3fe3d │ │ │ │ @ instruction: 0x46404651 │ │ │ │ - cdp2 0, 3, cr15, cr12, cr3, {0} │ │ │ │ + cdp2 0, 3, cr15, cr8, cr3, {0} │ │ │ │ @ instruction: 0x4651e7d6 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - @ instruction: 0xe7cafe37 │ │ │ │ + @ instruction: 0xe7cafe33 │ │ │ │ @ instruction: 0x46404651 │ │ │ │ - cdp2 0, 3, cr15, cr2, cr3, {0} │ │ │ │ + cdp2 0, 2, cr15, cr14, cr3, {0} │ │ │ │ @ instruction: 0x4651e7be │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - ldr pc, [r2, sp, lsr #28]! │ │ │ │ + ldr pc, [r2, r9, lsr #28]! │ │ │ │ @ instruction: 0x46404651 │ │ │ │ - cdp2 0, 2, cr15, cr8, cr3, {0} │ │ │ │ + cdp2 0, 2, cr15, cr4, cr3, {0} │ │ │ │ vabd.s8 d30, d26, d22 │ │ │ │ - vmla.f d21, d0, d0[0] │ │ │ │ + vbic.i32 d21, #8 @ 0x00000008 │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - cdp2 0, 2, cr15, cr0, cr3, {0} │ │ │ │ + cdp2 0, 1, cr15, cr12, cr3, {0} │ │ │ │ vmlacs.f32 s12, s1, s13 │ │ │ │ orrhi pc, r0, r0 │ │ │ │ - bmi 953468 │ │ │ │ + bmi 753468 │ │ │ │ beq d3640 │ │ │ │ - blvs 1053470 │ │ │ │ + blvs e53470 │ │ │ │ bleq d3648 │ │ │ │ stmdbeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ - ldcvs 2, cr15, [ip], #300 @ 0x12c │ │ │ │ + ldcvs 2, cr15, [r4], #300 @ 0x12c │ │ │ │ stceq 2, cr15, [r2], {192} @ 0xc0 │ │ │ │ andsgt pc, r0, sp, asr #17 │ │ │ │ @ instruction: 0x46516870 │ │ │ │ @ instruction: 0xf979f7fe │ │ │ │ stmdacs r0, {r7, r9, sl, lr} │ │ │ │ bge ff093c64 │ │ │ │ strcs r6, [r0, #-2290] @ 0xfffff70e │ │ │ │ @@ -5691,262 +5691,262 @@ │ │ │ │ stmdacs r0, {r2, r3, r4, r5, r7, r9, fp, sp, lr, pc} │ │ │ │ bge fe953cd4 │ │ │ │ @ instruction: 0xf7fa6874 │ │ │ │ stmdavs r0, {r2, r4, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ blx 1d54bdc │ │ │ │ strmi r4, [r3], -sl, lsr #12 │ │ │ │ vmax.s8 d20, d11, d17 │ │ │ │ - vaddl.s8 q11, d0, d16 │ │ │ │ + vmov.i32 d22, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ @ instruction: 0x4640fc11 │ │ │ │ bl 854be4 │ │ │ │ strbmi r3, [r0], -r1 │ │ │ │ bge 1c93e00 │ │ │ │ bl 554bf0 │ │ │ │ blcs 71e98 │ │ │ │ bge fedd4a0c │ │ │ │ vtst.8 q11, , q9 │ │ │ │ - vshr.s64 q11, q0, #64 │ │ │ │ + vmla.i d22, d16, d0[2] │ │ │ │ ldmdavs r9!, {r1} │ │ │ │ ldmib r2!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ blt feb54c20 │ │ │ │ ldmiblt sl, {r1, r3, r4, r6, fp, sp, lr} │ │ │ │ ldrtmi r2, [r0], -r1, lsl #4 │ │ │ │ vqadd.s8 q11, , q5 │ │ │ │ - vaddw.s8 , q0, d28 │ │ │ │ + vaddw.s8 , q0, d20 │ │ │ │ @ instruction: 0xf0030102 │ │ │ │ - stmiavs r1!, {r0, r1, r3, r4, r7, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r0, r1, r2, r4, r7, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0064630 │ │ │ │ - vpadd.i8 d31, d27, d21 │ │ │ │ - vaddw.s8 q10, q0, d12 │ │ │ │ + vpadd.i8 d31, d27, d17 │ │ │ │ + vaddw.s8 q10, q0, d4 │ │ │ │ ldrtmi r0, [r0], -r2, lsl #2 │ │ │ │ - ldc2 0, cr15, [r0, #12] │ │ │ │ + stc2 0, cr15, [ip, #12] │ │ │ │ ldrtmi r6, [r0], -r3, ror #16 │ │ │ │ @ instruction: 0x461a4651 │ │ │ │ - stc2 0, cr15, [sl, #12] │ │ │ │ + stc2 0, cr15, [r6, #12] │ │ │ │ strbmi lr, [r3], -r7, asr #12 │ │ │ │ - ldmibmi ip!, {r0, r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ + ldmibmi r4!, {r0, r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ ldrmi r4, [ip], -r0, lsr #13 │ │ │ │ @ instruction: 0xf853e006 │ │ │ │ @ instruction: 0xf1080028 │ │ │ │ strbmi r0, [r9], -r1, lsl #16 │ │ │ │ - ldc2l 0, cr15, [sl, #-12]! │ │ │ │ + ldc2l 0, cr15, [r6, #-12]! │ │ │ │ blcs 31a0c <__time64@plt+0x20724> │ │ │ │ ldcge 4, cr15, [fp, #252]! @ 0xfc │ │ │ │ ldrmi r6, [r0, #2082] @ 0x822 │ │ │ │ ldr sp, [r6, #1009]! @ 0x3f1 │ │ │ │ rschi pc, r4, #212, 16 @ 0xd40000 │ │ │ │ blt ffb14c90 │ │ │ │ blcs 30f24 <__time64@plt+0x1fc3c> │ │ │ │ bmi ff2cb298 │ │ │ │ @ instruction: 0xf8d468e1 │ │ │ │ @ instruction: 0xf00602e4 │ │ │ │ - @ instruction: 0xf8d4ffed │ │ │ │ + @ instruction: 0xf8d4ffe9 │ │ │ │ @ instruction: 0xf1b992e4 │ │ │ │ @ instruction: 0xf43f0f00 │ │ │ │ @ instruction: 0xf8d4aae9 │ │ │ │ strbmi r8, [r8], -ip │ │ │ │ - @ instruction: 0x21bcf24b │ │ │ │ + @ instruction: 0x21b4f24b │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldc2l 0, cr15, [r6, #-12] │ │ │ │ - andcc pc, r8, #-1342177276 @ 0xb0000004 │ │ │ │ + ldc2l 0, cr15, [r2, #-12] │ │ │ │ + andcc pc, r0, #-1342177276 @ 0xb0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ @ instruction: 0xf6484646 │ │ │ │ - vmlsl.s8 , d16, d12 │ │ │ │ + vmlsl.s8 , d16, d4 │ │ │ │ vpmax.s8 d16, d11, d2 │ │ │ │ - vqdmlsl.s , d0, d16 │ │ │ │ + vorr.i16 d19, #2048 @ 0x0800 │ │ │ │ ldrmi r0, [r0], r2, lsl #22 │ │ │ │ cdpcs 4, 0, cr9, cr0, cr4, {0} │ │ │ │ ldmdbvs r3!, {r2, r3, r4, r5, ip, lr, pc} │ │ │ │ blcs 658f4 │ │ │ │ ldmdavs r6!, {r0, r8, fp, ip, lr, pc}^ │ │ │ │ ldmibvs r3!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ rscsle r2, sl, r0, lsl #22 │ │ │ │ hvclt 50852 @ 0xc6a4 │ │ │ │ ldrbmi r6, [r1], -r0, ror #16 │ │ │ │ ldmdb r2!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r2!, {r4, r8, fp, ip, sp, pc} │ │ │ │ eorsle r2, r6, r2, lsl #20 │ │ │ │ ldrb r6, [r4, r4, lsr #16]! │ │ │ │ strbmi r4, [r8], -r1, asr #12 │ │ │ │ - stc2 0, cr15, [ip, #-12]! │ │ │ │ + stc2 0, cr15, [r8, #-12]! │ │ │ │ @ instruction: 0x46484631 │ │ │ │ - blx 1d2d32 │ │ │ │ + blx d2d32 │ │ │ │ @ instruction: 0x46484659 │ │ │ │ - stc2 0, cr15, [r4, #-12]! │ │ │ │ + stc2 0, cr15, [r0, #-12]! │ │ │ │ blcs 270df8 │ │ │ │ blvs d0ae8c │ │ │ │ bicsle r2, ip, r0, lsl #22 │ │ │ │ @ instruction: 0x46304631 │ │ │ │ - @ instruction: 0xf91cf007 │ │ │ │ + @ instruction: 0xf918f007 │ │ │ │ stmiavs r3!, {r0, r1, r2, r4, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ - rsbcs pc, r8, #-1342177276 @ 0xb0000004 │ │ │ │ + rsbcs pc, r0, #-1342177276 @ 0xb0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ mvnsmi pc, r1, asr #4 │ │ │ │ - @ instruction: 0xf8b8f002 │ │ │ │ + @ instruction: 0xf8b4f002 │ │ │ │ blt fe314d58 │ │ │ │ strb r6, [r0, #-123]! @ 0xffffff85 │ │ │ │ @ instruction: 0xf7ff9c04 │ │ │ │ ldrbmi fp, [r1], -pc, lsl #21 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - strbt pc, [pc], -r1, lsl #26 @ │ │ │ │ + @ instruction: 0xe66ffcfd │ │ │ │ @ instruction: 0x46404651 │ │ │ │ - ldc2l 0, cr15, [ip], #12 │ │ │ │ + ldc2l 0, cr15, [r8], #12 │ │ │ │ stmiavs r3!, {r0, r1, r2, r3, r4, r6, r9, sl, sp, lr, pc}^ │ │ │ │ svcne 0x0011681a │ │ │ │ ldmdble r3!, {r0, r8, fp, sp} │ │ │ │ eorsle r2, r1, r9, lsl #20 │ │ │ │ andseq pc, r8, r6, lsl #2 │ │ │ │ - bicseq pc, r0, sl, asr #12 │ │ │ │ + biceq pc, r8, sl, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - @ instruction: 0xff2af001 │ │ │ │ + @ instruction: 0xff26f001 │ │ │ │ stmiavs r3!, {r0, r3, r5, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ - addscs pc, r4, #-1342177276 @ 0xb0000004 │ │ │ │ + addcs pc, ip, #-1342177276 @ 0xb0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ mvnsmi pc, r1, asr #4 │ │ │ │ - @ instruction: 0xf88af002 │ │ │ │ + @ instruction: 0xf886f002 │ │ │ │ @ instruction: 0x4651e771 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - @ instruction: 0xe631fcd9 │ │ │ │ + @ instruction: 0xe631fcd5 │ │ │ │ @ instruction: 0x46404651 │ │ │ │ - ldc2l 0, cr15, [r4], {3} │ │ │ │ + ldc2l 0, cr15, [r0], {3} │ │ │ │ ldrbmi lr, [r1], -r1, lsr #12 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - ldr pc, [r1], -pc, asr #25 │ │ │ │ + ldr pc, [r1], -fp, asr #25 │ │ │ │ @ instruction: 0x46404651 │ │ │ │ - stc2l 0, cr15, [sl], {3} │ │ │ │ + stc2l 0, cr15, [r6], {3} │ │ │ │ bvs ffc905e4 │ │ │ │ addle r2, r4, r0, lsl #18 │ │ │ │ movwlt r6, #47883 @ 0xbb0b │ │ │ │ ldrb r6, [r9, r9, asr #16]! │ │ │ │ vmax.s8 q10, , q4 │ │ │ │ - vmla.f d18, d16, d0[6] │ │ │ │ + vmla.f d18, d16, d0[4] │ │ │ │ movwls r0, #20738 @ 0x5102 │ │ │ │ - ldc2 0, cr15, [sl], #12 │ │ │ │ + ldc2 0, cr15, [r6], #12 │ │ │ │ @ instruction: 0x46484631 │ │ │ │ - blx fe552e14 │ │ │ │ + blx fe452e14 │ │ │ │ vmax.s8 q10, , q4 │ │ │ │ - vsra.s64 q9, q14, #64 │ │ │ │ + vsra.s64 q9, q10, #64 │ │ │ │ @ instruction: 0xf0030102 │ │ │ │ - blls 1960d0 │ │ │ │ + blls 1960c0 │ │ │ │ ldrmi r4, [r9], -r8, asr #12 │ │ │ │ - blx fe252e2c │ │ │ │ + blx fe152e2c │ │ │ │ @ instruction: 0xf6494648 │ │ │ │ - vsra.s64 q11, q0, #64 │ │ │ │ + vmla.f d22, d16, d0[2] │ │ │ │ @ instruction: 0xf0030102 │ │ │ │ - strb pc, [r0, -r3, lsr #25]! @ │ │ │ │ + @ instruction: 0xe760fc9f │ │ │ │ tstls r5, r0, lsr r6 │ │ │ │ - @ instruction: 0xf8a0f007 │ │ │ │ + @ instruction: 0xf89cf007 │ │ │ │ ldrb r9, [r7, r5, lsl #18] │ │ │ │ @ instruction: 0xf7ff46b1 │ │ │ │ ldrbmi fp, [r1], -sl, lsr #19 │ │ │ │ @ instruction: 0xf0034640 │ │ │ │ - strb pc, [r1, #3221] @ 0xc95 @ │ │ │ │ + strb pc, [r1, #3217] @ 0xc91 @ │ │ │ │ ldmib ip!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe6800 │ │ │ │ stmdbls ip, {r0, r2, r3, r4, r5, r8, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf64a4602 │ │ │ │ - vmla.i d23, d0, d0[3] │ │ │ │ + vmla.i d23, d0, d0[1] │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ ldmdavs r4!, {r0, r1, r3, r4, r6, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ stmib lr!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe6800 │ │ │ │ strtmi pc, [r1], -pc, lsr #18 │ │ │ │ vmax.s8 d20, d11, d2 │ │ │ │ - vmla.i d22, d0, d0[4] │ │ │ │ + vmov.i32 q11, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ ldmdavs r4!, {r0, r2, r3, r6, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ stmib r0!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe6800 │ │ │ │ strtmi pc, [r1], -r1, lsr #18 │ │ │ │ vmax.s8 d20, d11, d2 │ │ │ │ - vmla.i d22, d0, d0[1] │ │ │ │ + vmvn.i32 d22, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ ldmdavs r4!, {r0, r1, r2, r3, r4, r5, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ ldmib r2, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe6800 │ │ │ │ @ instruction: 0x4621f913 │ │ │ │ vmax.s8 d20, d11, d2 │ │ │ │ - vmvn.i32 q11, #12 @ 0x0000000c │ │ │ │ + vmvn.i32 q11, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ @ instruction: 0xf7fafab1 │ │ │ │ stmdavs r0, {r1, r2, r7, r8, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf906f7fe │ │ │ │ strmi r9, [r2], -ip, lsl #18 │ │ │ │ - andsvs pc, r0, sl, asr #12 │ │ │ │ + andvs pc, r8, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ blx fe954eb8 │ │ │ │ - adcscc pc, ip, #-1342177276 @ 0xb0000004 │ │ │ │ + adcscc pc, r4, #-1342177276 @ 0xb0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ bicsne pc, r2, r1, asr #4 │ │ │ │ blx ffc54ed0 │ │ │ │ - rscseq pc, ip, fp, asr #4 │ │ │ │ + rscseq pc, r4, fp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7fa6e61 │ │ │ │ @ instruction: 0xf64afa91 │ │ │ │ - vmvn.i32 , #12 @ 0x0000000c │ │ │ │ + vmvn.i32 , #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ @ instruction: 0xf64afa8b │ │ │ │ - vshr.s64 d19, d12, #64 │ │ │ │ + vshr.s64 d19, d4, #64 │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ ldmdavs fp, {r0, r2, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf64adeff │ │ │ │ - vmla.i d23, d16, d0[1] │ │ │ │ + vshr.s64 d23, d28, #64 │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ vpmin.s8 , , │ │ │ │ - vaddl.s8 q8, d16, d8 │ │ │ │ + vaddl.s8 q8, d16, d0 │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ movwcs pc, #2679 @ 0xa77 @ │ │ │ │ mrcle 8, 7, r6, cr15, cr11, {2} │ │ │ │ - adcscc pc, r8, sl, asr #12 │ │ │ │ + adcscc pc, r0, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ blx 1bd4f24 │ │ │ │ - sbcscc pc, r4, sl, asr #12 │ │ │ │ + sbccc pc, ip, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ blx 1a54f30 │ │ │ │ - eorvs pc, r4, #77594624 @ 0x4a00000 │ │ │ │ + andsvs pc, ip, #77594624 @ 0x4a00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ orrne pc, r1, r0, asr #4 │ │ │ │ blx fed54f48 │ │ │ │ - rsccc pc, r8, sl, asr #12 │ │ │ │ + rsccc pc, r0, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ blx 15d4f54 │ │ │ │ - eorsmi pc, r0, sl, asr #12 │ │ │ │ + eormi pc, r8, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ blx 1454f60 │ │ │ │ - andeq pc, r0, fp, asr #4 │ │ │ │ + rscsvc pc, r8, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ blx 12d4f6c │ │ │ │ - eoreq pc, ip, fp, asr #4 │ │ │ │ + eoreq pc, r4, fp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ blx 1154f78 │ │ │ │ - eorvs pc, r4, #77594624 @ 0x4a00000 │ │ │ │ + andsvs pc, ip, #77594624 @ 0x4a00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ orrsne pc, r3, r0, asr #4 │ │ │ │ blx fe454f90 │ │ │ │ - addmi pc, r8, sl, asr #12 │ │ │ │ + addmi pc, r0, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ blx cd4f9c │ │ │ │ - rscsmi pc, r0, sl, asr #12 │ │ │ │ + rscmi pc, r8, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7fa462a │ │ │ │ svclt 0x0000fa2b │ │ │ │ - strdeq lr, [r2], -r0 │ │ │ │ - andeq lr, r2, r8, lsr #29 │ │ │ │ + andeq lr, r2, r8, ror #31 │ │ │ │ + andeq lr, r2, r0, lsr #29 │ │ │ │ push {r0, r1, r2, r3, sl, ip, sp, pc} │ │ │ │ strdlt r4, [r2], r0 │ │ │ │ @ instruction: 0xf856ae08 │ │ │ │ strls r5, [r1], -r4, lsl #22 │ │ │ │ rsble r2, r0, r0, lsl #26 │ │ │ │ @ instruction: 0xf7fa4628 │ │ │ │ @ instruction: 0x4604e8d6 │ │ │ │ @@ -5958,15 +5958,15 @@ │ │ │ │ strmi r6, [r4], #-2227 @ 0xfffff74d │ │ │ │ svcge 0x000cb143 │ │ │ │ @ instruction: 0xf7fa4618 │ │ │ │ @ instruction: 0xf857e8c4 │ │ │ │ strmi r3, [r4], #-2820 @ 0xfffff4fc │ │ │ │ mvnsle r2, r0, lsl #22 │ │ │ │ @ instruction: 0xf0001c60 │ │ │ │ - @ instruction: 0x4607fe9d │ │ │ │ + @ instruction: 0x4607fe99 │ │ │ │ strls r4, [r1], -r8, lsr #12 │ │ │ │ ldm r6!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ strmi r4, [r4], -r9, lsr #12 │ │ │ │ ldrtmi r4, [r8], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7fa443c │ │ │ │ @ instruction: 0xf8dde800 │ │ │ │ @ instruction: 0xf1b88024 │ │ │ │ @@ -5993,15 +5993,15 @@ │ │ │ │ @ instruction: 0xf858efd4 │ │ │ │ vmlacs.f64 d6, d0, d4 │ │ │ │ movwcs sp, #497 @ 0x1f1 │ │ │ │ ldrtmi r7, [r8], -r3, lsr #32 │ │ │ │ pop {r1, ip, sp, pc} │ │ │ │ strdlt r4, [r4], -r0 │ │ │ │ andcs r4, r1, r0, ror r7 │ │ │ │ - cdp2 0, 5, cr15, cr6, cr0, {0} │ │ │ │ + cdp2 0, 5, cr15, cr2, cr0, {0} │ │ │ │ strmi r9, [r7], -r1, lsl #12 │ │ │ │ ldrb r7, [r2, r5]! │ │ │ │ @ instruction: 0x4606b5f8 │ │ │ │ ldrmi r4, [r7], -ip, lsl #12 │ │ │ │ cmplt ip, r0, lsr #12 │ │ │ │ stmda r8!, {r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ strmi r4, [r5], -r1, lsr #12 │ │ │ │ @@ -6084,21 +6084,21 @@ │ │ │ │ andcc pc, r3, lr, asr r8 @ │ │ │ │ @ instruction: 0xf7f96818 │ │ │ │ @ instruction: 0xf7faefd8 │ │ │ │ blls 351394 │ │ │ │ ldrbmi fp, [r8], -fp, lsl #2 │ │ │ │ @ instruction: 0xf04f4798 │ │ │ │ ldrb r0, [r7, r0, lsl #22] │ │ │ │ - ldrdeq fp, [r1], -r4 │ │ │ │ + andeq fp, r1, ip, asr #11 │ │ │ │ ldrdeq r8, [r3], -sl │ │ │ │ - andeq fp, r1, lr, lsl #11 │ │ │ │ - andeq fp, r1, ip, ror #10 │ │ │ │ - andeq fp, r1, r8, lsl r5 │ │ │ │ + andeq fp, r1, r6, lsl #11 │ │ │ │ + andeq fp, r1, r4, ror #10 │ │ │ │ + andeq fp, r1, r0, lsl r5 │ │ │ │ andeq r0, r0, r8, lsr #2 │ │ │ │ - andeq r7, r1, r2, lsl #12 │ │ │ │ + strdeq r7, [r1], -sl │ │ │ │ tstcs r0, r8, lsr r5 │ │ │ │ ldcmi 13, cr4, [r3], {18} │ │ │ │ ldrbtmi r4, [sp], #-1670 @ 0xfffff97a │ │ │ │ ldrbtmi r2, [ip], #-30 @ 0xffffffe2 │ │ │ │ bne 110f268 │ │ │ │ cmpeq r3, #1024 @ 0x400 │ │ │ │ @ instruction: 0x1c03ea4f │ │ │ │ @@ -6112,18 +6112,18 @@ │ │ │ │ blmi 246748 │ │ │ │ stmdbmi r8, {r1, r4, r5, r6, r9, sl, lr} │ │ │ │ stmiapl fp!, {r0, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf7f96818 │ │ │ │ @ instruction: 0xf7faef9c │ │ │ │ svclt 0x0000e828 │ │ │ │ andeq r8, r3, sl, asr #27 │ │ │ │ - @ instruction: 0x0001b4b6 │ │ │ │ - muleq r1, r4, r4 │ │ │ │ + andeq fp, r1, lr, lsr #9 │ │ │ │ + andeq fp, r1, ip, lsl #9 │ │ │ │ andeq r0, r0, r8, lsr #2 │ │ │ │ - andeq r7, r1, r8, lsl #11 │ │ │ │ + andeq r7, r1, r0, lsl #11 │ │ │ │ @ instruction: 0xf8124602 │ │ │ │ cmplt fp, r1, lsl #22 │ │ │ │ mrscs r2, (UNDEF: 67) │ │ │ │ andcc pc, r0, r1, lsl #22 │ │ │ │ blcc 952ec │ │ │ │ blcs 2546c <__time64@plt+0x14184> │ │ │ │ @ instruction: 0x4770d1f8 │ │ │ │ @@ -6333,179 +6333,177 @@ │ │ │ │ svcmi 0x00f8e92d │ │ │ │ stmdbvs r6, {r0, r8, r9, fp, sp} │ │ │ │ ldrmi r4, [pc], -r5, lsl #12 │ │ │ │ ldrmi r4, [r1], r8, lsl #13 │ │ │ │ stmdbvs r2, {r1, r2, r8, ip, lr, pc}^ │ │ │ │ movteq lr, #27398 @ 0x6b06 │ │ │ │ svceq 0x0082ebb3 │ │ │ │ - sbchi pc, fp, r0, asr #4 │ │ │ │ + sbchi pc, r8, r0, asr #4 │ │ │ │ @ instruction: 0xf8df6ba8 │ │ │ │ - stmibvs sl!, {r2, r3, r4, r6, r7, r8, sp, pc}^ │ │ │ │ + stmibvs sl!, {r2, r4, r6, r7, r8, sp, pc}^ │ │ │ │ ldrbtmi r0, [sl], #256 @ 0x100 │ │ │ │ tsteq r0, sl, lsl #22 │ │ │ │ mvnvs r3, r1, lsl #4 │ │ │ │ andgt pc, r0, sl, asr r8 @ │ │ │ │ @ instruction: 0xf8d1684c │ │ │ │ stmiavs fp!, {r2, r3, sp, lr, pc}^ │ │ │ │ strcs pc, [r4], #-2985 @ 0xfffff457 │ │ │ │ andeq lr, r4, #173056 @ 0x2a400 │ │ │ │ ldrbeq lr, [r2], #-2820 @ 0xfffff4fc │ │ │ │ vst1.8 {d15-d16}, [lr :128], r4 │ │ │ │ ldrls pc, [r4], #-2828 @ 0xfffff4f4 │ │ │ │ bleq fe151f6c │ │ │ │ eoreq pc, r4, r3, asr r8 @ │ │ │ │ andeq lr, fp, #3072 @ 0xc00 │ │ │ │ - @ instruction: 0xf0002800 │ │ │ │ - stmdacs r1, {r1, r3, r7, pc} │ │ │ │ - adcshi pc, r3, r0 │ │ │ │ - strbmi r6, [r1], -fp, ror #16 │ │ │ │ - stmdacs r0, {r3, r4, r7, r8, r9, sl, lr} │ │ │ │ - addshi pc, r7, r0, asr #32 │ │ │ │ - strmi r6, [r3], fp, lsr #23 │ │ │ │ - andeq pc, r1, #1073741826 @ 0x40000002 │ │ │ │ - bl 297ac8 │ │ │ │ - @ instruction: 0xf85a0003 │ │ │ │ - ldmib r0, {r0, r1, ip}^ │ │ │ │ - stmdbcc r2, {r1, ip, sp} │ │ │ │ - movwgt pc, #15273 @ 0x3ba9 @ │ │ │ │ - stmdbeq r3, {r0, r3, r5, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ - cmpeq r9, #3072 @ 0xc00 │ │ │ │ - blx 67986 │ │ │ │ - stmiavs fp!, {r0, r1, r4, r9, fp, sp}^ │ │ │ │ - ldrbmi r6, [r4], #-2601 @ 0xfffff5d7 │ │ │ │ - adcmi r3, r6, #1073741824 @ 0x40000000 │ │ │ │ - ldmdale fp, {r0, r3, r5, r9, sp, lr}^ │ │ │ │ - b 13de51c │ │ │ │ - @ instruction: 0xf8530984 │ │ │ │ - bl d7724 │ │ │ │ - stmdacs r0, {r0, r3, r9} │ │ │ │ - stmdacs r1, {r3, r6, ip, lr, pc} │ │ │ │ - addshi pc, r6, r0 │ │ │ │ - strbmi r6, [r1], -fp, ror #16 │ │ │ │ - stmdacs r0, {r3, r4, r7, r8, r9, sl, lr} │ │ │ │ - bvs a8bc64 │ │ │ │ - adcmi r4, r6, #84, 8 @ 0x54000000 │ │ │ │ - tstpeq r1, r1, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - ldmdale r0, {r0, r3, r5, r9, sp, lr}^ │ │ │ │ - blne fe931a68 │ │ │ │ + subsle r2, r7, r0, lsl #16 │ │ │ │ + @ instruction: 0xf0002801 │ │ │ │ + stmdavs fp!, {r0, r4, r5, r7, pc}^ │ │ │ │ + ldrmi r4, [r8, r1, asr #12] │ │ │ │ + @ instruction: 0xf0402800 │ │ │ │ + blvs feaf78a4 │ │ │ │ + @ instruction: 0xf1094683 │ │ │ │ + tsteq fp, r1, lsl #4 │ │ │ │ + andeq lr, r3, sl, lsl #22 │ │ │ │ + andne pc, r3, sl, asr r8 @ │ │ │ │ + ldrdcc lr, [r2], -r0 │ │ │ │ + blx fea65a72 │ │ │ │ + bl fea88278 │ │ │ │ + bl d9a7c │ │ │ │ + sbcmi r0, r3, r9, asr r3 │ │ │ │ + bcs 51627c │ │ │ │ + bvs a71a28 │ │ │ │ + tstcc r1, r4, asr r4 │ │ │ │ + eorvs r4, r9, #1610612746 @ 0x6000000a │ │ │ │ + blne fe94d72c │ │ │ │ stmibeq r4, {r0, r1, r2, r3, r6, r9, fp, sp, lr, pc} │ │ │ │ eoreq pc, r4, r3, asr r8 @ │ │ │ │ andeq lr, r9, #3072 @ 0xc00 │ │ │ │ - eorle r2, pc, r0, lsl #16 │ │ │ │ - rsbsle r2, sp, r1, lsl #16 │ │ │ │ + stmdacs r1, {r3, r4, r5, r7, r8, ip, sp, pc} │ │ │ │ + addshi pc, r5, r0 │ │ │ │ strbmi r6, [r1], -fp, ror #16 │ │ │ │ stmdacs r0, {r3, r4, r7, r8, r9, sl, lr} │ │ │ │ - ldrbmi sp, [r4], #-342 @ 0xfffffeaa │ │ │ │ - adcmi r6, r6, #15400960 @ 0xeb0000 │ │ │ │ - svclt 0x00986a29 │ │ │ │ - smlatbcc r1, r4, fp, r1 │ │ │ │ - b 13eff90 │ │ │ │ - @ instruction: 0xf8530984 │ │ │ │ - bl d7784 │ │ │ │ - biclt r0, r8, r9, lsl #4 │ │ │ │ - rsble r2, r7, r1, lsl #16 │ │ │ │ - strbmi r6, [r1], -fp, ror #16 │ │ │ │ - stmdacs r0, {r3, r4, r7, r8, r9, sl, lr} │ │ │ │ - bvs a8bc08 │ │ │ │ + bvs a8bc5c │ │ │ │ adcmi r4, r6, #84, 8 @ 0x54000000 │ │ │ │ tstpeq r1, r1, lsl #2 @ p-variant is OBSOLETE │ │ │ │ - stmibeq r4, {r0, r1, r2, r3, r6, r9, fp, sp, lr, pc} │ │ │ │ - stmdale sl!, {r0, r3, r5, r9, sp, lr} │ │ │ │ - blne fe931ac8 │ │ │ │ + ldmdale pc, {r0, r3, r5, r9, sp, lr} @ │ │ │ │ + blne fe931a64 │ │ │ │ stmibeq r4, {r0, r1, r2, r3, r6, r9, fp, sp, lr, pc} │ │ │ │ eoreq pc, r4, r3, asr r8 @ │ │ │ │ andeq lr, r9, #3072 @ 0xc00 │ │ │ │ - mvnle r2, r0, lsl #16 │ │ │ │ - @ instruction: 0xf1bbb19f │ │ │ │ - teqle r2, r0, lsl #30 │ │ │ │ - movwcc r6, #6507 @ 0x196b │ │ │ │ - ldrmi r6, [r0], -fp, ror #2 │ │ │ │ - svchi 0x00f8e8bd │ │ │ │ - eoreq pc, r4, r3, asr r8 @ │ │ │ │ - stmibeq r4, {r0, r1, r2, r3, r6, r9, fp, sp, lr, pc} │ │ │ │ - andeq lr, r9, #3072 @ 0xc00 │ │ │ │ - @ instruction: 0xd1a42800 │ │ │ │ - svccs 0x0000e7ec │ │ │ │ - andcs sp, r0, #-2147483589 @ 0x8000003b │ │ │ │ - stmiavs fp!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xb19fb9f8 │ │ │ │ + svceq 0x0000f1bb │ │ │ │ + stmdbvs fp!, {r1, r5, r6, r8, ip, lr, pc}^ │ │ │ │ + cmnvs fp, r1, lsl #6 │ │ │ │ + pop {r4, r9, sl, lr} │ │ │ │ + @ instruction: 0xf8538ff8 │ │ │ │ + b 13d7770 │ │ │ │ + bl d9cf4 │ │ │ │ + stmdacs r0, {r0, r3, r9} │ │ │ │ + ubfx sp, r5, #3, #13 │ │ │ │ + mvnle r2, r0, lsl #30 │ │ │ │ + strb r2, [pc, r0, lsl #4]! │ │ │ │ + b 13f1aa4 │ │ │ │ + bl d9d0c │ │ │ │ + @ instruction: 0xf8530209 │ │ │ │ + stmdacs r0, {r2, r5} │ │ │ │ + stmdacs r1, {r0, r1, r2, r3, r4, r6, r7, ip, lr, pc} │ │ │ │ + stmdavs fp!, {r0, r2, r3, r4, r6, ip, lr, pc}^ │ │ │ │ + ldrmi r4, [r8, r1, asr #12] │ │ │ │ + teqle r6, r0, lsl #16 │ │ │ │ + stmiavs fp!, {r2, r4, r6, sl, lr}^ │ │ │ │ + bvs a681b4 │ │ │ │ + blne fe947580 │ │ │ │ + eorvs r3, r9, #1073741824 @ 0x40000000 │ │ │ │ stmibeq r4, {r0, r1, r2, r3, r6, r9, fp, sp, lr, pc} │ │ │ │ - andeq lr, r9, #3072 @ 0xc00 │ │ │ │ eoreq pc, r4, r3, asr r8 @ │ │ │ │ - @ instruction: 0xd1af2800 │ │ │ │ - stmiavs fp!, {r1, r2, r3, r4, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ andeq lr, r9, #3072 @ 0xc00 │ │ │ │ - eoreq pc, r4, r3, asr r8 @ │ │ │ │ - @ instruction: 0xd1bd2800 │ │ │ │ - stmiavs sl!, {r1, r2, r4, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ - @ instruction: 0x4610445a │ │ │ │ - svchi 0x00f8e8bd │ │ │ │ - strbmi r6, [sl], #-2282 @ 0xfffff716 │ │ │ │ - @ instruction: 0xf000e7d5 │ │ │ │ - stmdacs r0, {r0, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ - stmdbvs lr!, {r0, r1, r2, r3, r4, r6, r7, ip, lr, pc} │ │ │ │ - stmibvs fp!, {r1, r2, r3, r5, r8, r9, sl, sp, lr, pc} │ │ │ │ - ldrbmi r2, [sl], -r0, lsl #2 │ │ │ │ - @ instruction: 0x61ab3b01 │ │ │ │ - andne pc, r0, fp, asr #17 │ │ │ │ - stmvs r9, {r0, r1, r2, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ - @ instruction: 0xf1ac4693 │ │ │ │ - blx fea5a7be │ │ │ │ - @ instruction: 0xf1091201 │ │ │ │ - bl fea57bc0 │ │ │ │ - bl 99bc8 │ │ │ │ - blx 898128 │ │ │ │ - blx 354002 │ │ │ │ - smmla r7, r2, sl, r1 │ │ │ │ - svceq 0x0000f1bb │ │ │ │ - ldrmi fp, [r3], r8, lsl #30 │ │ │ │ - svclt 0x0000e753 │ │ │ │ - andeq fp, r1, lr, ror #1 │ │ │ │ + sbcle r2, r8, r0, lsl #16 │ │ │ │ + suble r2, r6, r1, lsl #16 │ │ │ │ + strbmi r6, [r1], -fp, ror #16 │ │ │ │ + bllt 295a0 <__time64@plt+0x182b8> │ │ │ │ + ldrbmi r6, [r4], #-2601 @ 0xfffff5d7 │ │ │ │ + @ instruction: 0xf10142a6 │ │ │ │ + b 13d7b50 │ │ │ │ + eorvs r0, r9, #132, 18 @ 0x210000 │ │ │ │ + stmiavs fp!, {r1, r3, fp, ip, lr, pc}^ │ │ │ │ + b 13de5e8 │ │ │ │ + @ instruction: 0xf8530984 │ │ │ │ + bl d77f0 │ │ │ │ + stmdacs r0, {r0, r3, r9} │ │ │ │ + str sp, [lr, r6, ror #3]! │ │ │ │ + bl f1b18 │ │ │ │ + @ instruction: 0xf8530209 │ │ │ │ + stmdacs r0, {r2, r5} │ │ │ │ + sbfx sp, lr, #3, #7 │ │ │ │ + ldrbmi r6, [sl], #-2282 @ 0xfffff716 │ │ │ │ + pop {r4, r9, sl, lr} │ │ │ │ + stmiavs sl!, {r3, r4, r5, r6, r7, r8, r9, sl, fp, pc}^ │ │ │ │ + str r4, [r5, sl, asr #8]! │ │ │ │ + @ instruction: 0xf8c0f000 │ │ │ │ + adcle r2, pc, r0, lsl #16 │ │ │ │ + ldr r6, [r1, -lr, lsr #18]! │ │ │ │ + smlatbcs r0, fp, r9, r6 │ │ │ │ + blcc 69104 │ │ │ │ + @ instruction: 0xf8cb61ab │ │ │ │ + ldr r1, [r7, r0] │ │ │ │ + ldrmi r6, [r3], r9, lsl #17 │ │ │ │ + stceq 1, cr15, [r2], {172} @ 0xac │ │ │ │ + andne pc, r1, #173056 @ 0x2a400 │ │ │ │ + tstpeq r1, r9, lsl #2 @ p-variant is OBSOLETE │ │ │ │ + stmdbeq r2, {r0, r3, r5, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ + subseq lr, r9, #2048 @ 0x800 │ │ │ │ + vpmax.s8 d15, d14, d18 │ │ │ │ + bne 4d63f4 │ │ │ │ + @ instruction: 0xf1bbe759 │ │ │ │ + svclt 0x00080f00 │ │ │ │ + @ instruction: 0xe7554693 │ │ │ │ + andeq fp, r1, r6, ror #1 │ │ │ │ push {r0, r1, r6, r7, r8, fp, sp, lr} │ │ │ │ @ instruction: 0x460647f0 │ │ │ │ bicvs r3, r3, r1, lsl #6 │ │ │ │ - blvs fe029048 │ │ │ │ + blvs fe029040 │ │ │ │ ldrdls pc, [r0, -pc] │ │ │ │ strdeq r6, [r0, -r3] │ │ │ │ - bl 268bdc │ │ │ │ + bl 268bd4 │ │ │ │ @ instruction: 0xf8590200 │ │ │ │ ldmdavs r4, {}^ @ │ │ │ │ ldrdgt pc, [ip], -r2 │ │ │ │ strpl pc, [r4], #-2983 @ 0xfffff459 │ │ │ │ - bl 11e500 │ │ │ │ - blx 918964 │ │ │ │ - blx 54846 │ │ │ │ + bl 11e4f8 │ │ │ │ + blx 91895c │ │ │ │ + blx 5483e │ │ │ │ @ instruction: 0xf8537414 │ │ │ │ stccs 0, cr5, [r0, #-144] @ 0xffffff70 │ │ │ │ @ instruction: 0xf8d6d056 │ │ │ │ pkhbtmi sl, r8, r0 │ │ │ │ subsle r2, r5, r1, lsl #26 │ │ │ │ @ instruction: 0x46286873 │ │ │ │ stmdacs r0, {r3, r4, r7, r8, r9, sl, lr} │ │ │ │ - blvs fed0bd68 │ │ │ │ + blvs fed0bd60 │ │ │ │ tsteq fp, r9, ror ip │ │ │ │ andeq lr, r3, r9, lsl #22 │ │ │ │ andcs pc, r3, r9, asr r8 @ │ │ │ │ ldrdcc lr, [r2], -r0 │ │ │ │ - blx fe9e6052 │ │ │ │ - bne fffec458 │ │ │ │ + blx fe9e604a │ │ │ │ + bne fffec450 │ │ │ │ cmpeq r7, #3072 @ 0xc00 │ │ │ │ - blx a7b62 │ │ │ │ + blx a7b5a │ │ │ │ ldmvs r3!, {r0, r1, r4, r8, r9, sl, ip}^ │ │ │ │ ldrtmi r6, [ip], #-2610 @ 0xfffff5ce │ │ │ │ strmi r3, [r2, #513]! @ 0x201 │ │ │ │ svclt 0x00986232 │ │ │ │ streq lr, [sl], #-2980 @ 0xfffff45c │ │ │ │ eorpl pc, r4, r3, asr r8 @ │ │ │ │ stccs 3, cr11, [r1, #-468] @ 0xfffffe2c │ │ │ │ ldmdavs r3!, {r0, r1, r4, r5, r6, r7, ip, lr, pc}^ │ │ │ │ strtmi r4, [r8], -r1, asr #12 │ │ │ │ - bllt 10296dc │ │ │ │ + bllt 10296d4 │ │ │ │ ldmvs r3!, {r2, r3, r4, r5, sl, lr}^ │ │ │ │ - bvs ca8f0c │ │ │ │ - bl fe9476e8 │ │ │ │ + bvs ca8f04 │ │ │ │ + bl fe9476e0 │ │ │ │ andcc r0, r1, #167772160 @ 0xa000000 │ │ │ │ @ instruction: 0xf8536232 │ │ │ │ bicslt r5, sp, r4, lsr #32 │ │ │ │ rscle r2, r0, r1, lsl #26 │ │ │ │ @ instruction: 0x46416873 │ │ │ │ ldrmi r4, [r8, r8, lsr #12] │ │ │ │ ldrtmi fp, [ip], #-2472 @ 0xfffff658 │ │ │ │ @@ -6519,205 +6517,205 @@ │ │ │ │ @ instruction: 0x46286873 │ │ │ │ stmdacs r0, {r3, r4, r7, r8, r9, sl, lr} │ │ │ │ and sp, r0, fp, ror #1 │ │ │ │ strtmi r2, [r8], -r0, lsl #10 │ │ │ │ @ instruction: 0x87f0e8bd │ │ │ │ stmdacc r2, {r1, r4, r7, fp, sp, lr} │ │ │ │ andne pc, r2, #171008 @ 0x29c00 │ │ │ │ - bne fefdeac4 │ │ │ │ + bne fefdeabc │ │ │ │ subseq lr, r7, #2048 @ 0x800 │ │ │ │ vpmax.s8 d15, d12, d18 │ │ │ │ ldrne pc, [r2, -r0, lsl #22] │ │ │ │ svclt 0x0000e7b4 │ │ │ │ strdeq sl, [r1], -ip │ │ │ │ @ instruction: 0x4604b570 │ │ │ │ @ instruction: 0x460d4616 │ │ │ │ stmdavs r3!, {r3, r9, sl, lr} │ │ │ │ @ instruction: 0x46334798 │ │ │ │ strtmi r4, [r9], -r2, lsl #12 │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7ff4070 │ │ │ │ - svclt 0x0000be63 │ │ │ │ + svclt 0x0000be67 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stmiavs r1, {r7, r9, sl, lr}^ │ │ │ │ andcc lr, r5, #208, 18 @ 0x340000 │ │ │ │ stmdbvs r4, {r0, r1, r7, ip, sp, pc} │ │ │ │ @ instruction: 0x91011a9b │ │ │ │ - bl 57a8c │ │ │ │ - bl fed19340 │ │ │ │ + bl 57a84 │ │ │ │ + bl fed19338 │ │ │ │ rsbsle r0, sl, #268 @ 0x10c │ │ │ │ - ldc2l 7, cr15, [sl], #-1020 @ 0xfffffc04 │ │ │ │ + ldc2l 7, cr15, [lr], #-1020 @ 0xfffffc04 │ │ │ │ tsteq r2, r9, asr #22 │ │ │ │ ldrbtmi r4, [fp], #-1541 @ 0xfffff9fb │ │ │ │ @ instruction: 0xf8d8589c │ │ │ │ - blcs 23a08 <__time64@plt+0x12720> │ │ │ │ + blcs 23a00 <__time64@plt+0x12718> │ │ │ │ @ instruction: 0xf8d8d17b │ │ │ │ tstcs r4, r4, lsr #32 │ │ │ │ ldrmi r4, [r8, r0, lsr #12] │ │ │ │ eorsle r2, pc, r0, lsl #16 │ │ │ │ ldrdls pc, [r8, -pc] │ │ │ │ @ instruction: 0x2018f8d8 │ │ │ │ @ instruction: 0x3014f8d8 │ │ │ │ @ instruction: 0xf8c844f9 │ │ │ │ stcls 0, cr5, [r1, #-224] @ 0xffffff20 │ │ │ │ stmib r8, {r0, r1, r3, r4, r7, r9, fp, ip}^ │ │ │ │ andcs r0, r0, #50331648 @ 0x3000000 │ │ │ │ andcc lr, r5, #200, 18 @ 0x320000 │ │ │ │ - blmi 155ad0 │ │ │ │ + blmi 155ac8 │ │ │ │ stmdble lr!, {r0, sl, fp, sp} │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ ldrmi r4, [r8, r0, lsr #12] │ │ │ │ ldrsbtcc pc, [r8], -r8 @ │ │ │ │ ldrdcs pc, [ip], -r8 │ │ │ │ - bl 257e00 │ │ │ │ + bl 257df8 │ │ │ │ @ instruction: 0xf8590103 │ │ │ │ stmdavs fp, {r0, r1, ip, sp, lr}^ │ │ │ │ ldrd pc, [ip], -r1 │ │ │ │ movwge pc, #15264 @ 0x3ba0 @ │ │ │ │ - beq 112828 │ │ │ │ + beq 112820 │ │ │ │ cmpeq sl, #3072 @ 0xc00 │ │ │ │ vpmax.u8 d15, d14, d19 │ │ │ │ tstpeq r3, #7168 @ p-variant is OBSOLETE @ 0x1c00 │ │ │ │ - beq fe1125c0 │ │ │ │ + beq fe1125b8 │ │ │ │ eorlt pc, r3, r2, asr r8 @ │ │ │ │ svceq 0x0000f1bb │ │ │ │ adcmi sp, lr, #16, 2 │ │ │ │ andmi pc, r0, sl, asr #17 │ │ │ │ @ instruction: 0xf8d8d8d6 │ │ │ │ - blcs 23a70 <__time64@plt+0x12788> │ │ │ │ + blcs 23a68 <__time64@plt+0x12780> │ │ │ │ stmdals r1, {r0, r2, r3, r4, r5, ip, lr, pc} │ │ │ │ mulcs r1, r8, r7 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ adcmi r8, lr, #240, 30 @ 0x3c0 │ │ │ │ ldrb sp, [r2, sl, asr #17]! │ │ │ │ svceq 0x0001f1bb │ │ │ │ stmvs r9, {r0, r3, r5, ip, lr, pc} │ │ │ │ stceq 1, cr15, [r2], {167} @ 0xa7 │ │ │ │ @ instruction: 0x7010f8d8 │ │ │ │ smlatbge r1, r0, fp, pc @ │ │ │ │ - beq 93dfc │ │ │ │ - bl 5e300 │ │ │ │ - blx 857f44 │ │ │ │ - blx 353e42 │ │ │ │ + beq 93df4 │ │ │ │ + bl 5e2f8 │ │ │ │ + blx 857f3c │ │ │ │ + blx 353e3a │ │ │ │ strmi sl, [fp], #-273 @ 0xfffffeef │ │ │ │ stmdale r0, {r0, r1, r2, r3, r4, r7, r9, lr} │ │ │ │ @ instruction: 0xf8521bdb │ │ │ │ - bl 97aa4 │ │ │ │ + bl 97a9c │ │ │ │ stmdacs r0, {r0, r1, r7, r9, fp} │ │ │ │ stmdacs r1, {r0, r4, r6, r7, ip, lr, pc} │ │ │ │ strmi sp, [fp], #-13 │ │ │ │ ldmle r4!, {r0, r1, r2, r3, r4, r7, r9, lr}^ │ │ │ │ ldrsheq lr, [fp], #114 @ 0x72 │ │ │ │ svclt 0x00382b20 │ │ │ │ addsmi r2, ip, #32, 6 @ 0x80000000 │ │ │ │ svcge 0x007ef63f │ │ │ │ ldrsbtpl pc, [r8], -r8 @ │ │ │ │ @ instruction: 0xf7f9e781 │ │ │ │ - @ instruction: 0xf8d8ec44 │ │ │ │ + @ instruction: 0xf8d8ec48 │ │ │ │ andcs r0, r4, #44 @ 0x2c │ │ │ │ ldrmi r4, [r8, r1, lsr #12] │ │ │ │ @ instruction: 0xf8d8e782 │ │ │ │ - blcs 23b24 <__time64@plt+0x1283c> │ │ │ │ + blcs 23b1c <__time64@plt+0x12834> │ │ │ │ @ instruction: 0xf8d8d0bf │ │ │ │ stmdbls r1, {r2, r3, r5} │ │ │ │ @ instruction: 0xe7ba4798 │ │ │ │ @ instruction: 0x0001adb2 │ │ │ │ andeq sl, r1, ip, lsl #27 │ │ │ │ @ instruction: 0x460fb5f8 │ │ │ │ ldmib r0, {r0, r2, r4, r9, sl, lr}^ │ │ │ │ - bl 129280 │ │ │ │ + bl 129278 │ │ │ │ strtmi r0, [r0], -r6, lsl #13 │ │ │ │ strcc r4, [r4], #-1577 @ 0xfffff9d7 │ │ │ │ - blcs 71a8c │ │ │ │ + blcs 71a84 │ │ │ │ ldrmi sp, [r8, r1, lsl #18]! │ │ │ │ adcmi fp, r6, #8, 2 │ │ │ │ ldcllt 8, cr13, [r8, #980]! @ 0x3d4 │ │ │ │ @ instruction: 0xf64ab281 │ │ │ │ @ instruction: 0xf6cb53cc │ │ │ │ - bl ff06ca48 │ │ │ │ + bl ff06ca40 │ │ │ │ strmi r4, [r3], #-32 @ 0xffffffe0 │ │ │ │ addvc pc, r5, #536870916 @ 0x20000004 │ │ │ │ eormi pc, r4, #206569472 @ 0xc500000 │ │ │ │ movwcc pc, #17539 @ 0x4483 @ │ │ │ │ orrseq pc, sl, #131 @ 0x83 │ │ │ │ - bne ff4a8ad8 │ │ │ │ + bne ff4a8ad0 │ │ │ │ eorscs pc, r4, r5, asr #4 │ │ │ │ andscs pc, r3, r4, asr #5 │ │ │ │ andcs lr, r3, #532480 @ 0x82000 │ │ │ │ - bne fe6de5c0 │ │ │ │ - b fe01e4c4 │ │ │ │ - bne 6e3c10 │ │ │ │ - b fe0de314 │ │ │ │ - bne ff4a4710 │ │ │ │ - b fe09e5d4 │ │ │ │ - bne fe0282e4 │ │ │ │ - b fe01e548 │ │ │ │ - bne 6dbc28 │ │ │ │ - b fe0de32c │ │ │ │ - bne ff498a28 │ │ │ │ - b fe09e5ec │ │ │ │ - bne fe0204fc │ │ │ │ + bne fe6de5b8 │ │ │ │ + b fe01e4bc │ │ │ │ + bne 6e3c08 │ │ │ │ + b fe0de30c │ │ │ │ + bne ff4a4708 │ │ │ │ + b fe09e5cc │ │ │ │ + bne fe0282dc │ │ │ │ + b fe01e540 │ │ │ │ + bne 6dbc20 │ │ │ │ + b fe0de324 │ │ │ │ + bne ff498a20 │ │ │ │ + b fe09e5e4 │ │ │ │ + bne fe0204f4 │ │ │ │ sbcscc lr, r2, r0, lsl #21 │ │ │ │ svclt 0x00004770 │ │ │ │ ldrblt r6, [r0, #-2179]! @ 0xfffff77d │ │ │ │ ldmib r0, {r2, r9, sl, lr}^ │ │ │ │ addlt r5, r2, r3, lsl #4 │ │ │ │ @ instruction: 0xf5b2b963 │ │ │ │ ldmdale r6, {r7, r8, r9, sl, fp, sp} │ │ │ │ swpcs r0, r2, [r0] @ │ │ │ │ @ instruction: 0xf7f94628 │ │ │ │ - movwcs lr, #2916 @ 0xb64 │ │ │ │ + movwcs lr, #2920 @ 0xb68 │ │ │ │ movwcc lr, #22980 @ 0x59c4 │ │ │ │ ldcllt 0, cr11, [r0, #-8]! │ │ │ │ mcrcs 14, 0, r1, cr0, cr6, {2} │ │ │ │ @ instruction: 0xf855dbef │ │ │ │ stmdacs r1, {r1, r2, r5} │ │ │ │ stmiavs r3!, {r0, r1, r8, fp, ip, lr, pc} │ │ │ │ ldrmi r9, [r8, r1, lsl #4] │ │ │ │ vmlacc.f32 s18, s2, s2 │ │ │ │ vst1.64 {d30}, [pc :256], r3 │ │ │ │ @ instruction: 0xf7ff7080 │ │ │ │ - blmi 496918 │ │ │ │ + blmi 496920 │ │ │ │ smlatbeq r1, r2, sl, r6 │ │ │ │ @ instruction: 0x4605447b │ │ │ │ cmplt r2, lr, asr r8 │ │ │ │ ldrmi r6, [r0, r0, ror #17] │ │ │ │ cmplt fp, r3, lsr #22 │ │ │ │ andcs r6, r4, #224, 20 @ 0xe0000 │ │ │ │ @ instruction: 0x47984631 │ │ │ │ - blvs 190fb8c │ │ │ │ + blvs 190fb84 │ │ │ │ rscsle r2, r5, r0, lsl #22 │ │ │ │ - bvs ff831ef0 │ │ │ │ + bvs ff831ee8 │ │ │ │ @ instruction: 0xe7f14798 │ │ │ │ tstcs r4, r3, ror #20 │ │ │ │ @ instruction: 0x47984630 │ │ │ │ stmib r4, {r9, sp}^ │ │ │ │ @ instruction: 0x63a50603 │ │ │ │ andcs lr, r5, #196, 18 @ 0x310000 │ │ │ │ svclt 0x0000e7ca │ │ │ │ andeq sl, r1, r8, lsr #23 │ │ │ │ ldrdcc lr, [r2, -r0] │ │ │ │ @ instruction: 0x4606b570 │ │ │ │ ldmdblt fp, {r1, r7, ip, sp, pc}^ │ │ │ │ - blcs 32668 <__time64@plt+0x21380> │ │ │ │ + blcs 32660 <__time64@plt+0x21378> │ │ │ │ addhi pc, fp, r0 │ │ │ │ ldrmi r4, [r8, r8, lsl #12] │ │ │ │ @ instruction: 0x46306ab3 │ │ │ │ pop {r1, ip, sp, pc} │ │ │ │ @ instruction: 0x47184070 │ │ │ │ @ instruction: 0x1e656904 │ │ │ │ - bl 8cf78 │ │ │ │ + bl 8cf70 │ │ │ │ stclne 4, cr0, [fp], #-528 @ 0xfffffdf0 │ │ │ │ movweq pc, #28691 @ 0x7013 @ │ │ │ │ - blcs 8bd70 │ │ │ │ - blcs cbc64 │ │ │ │ - blcs 10bc4c │ │ │ │ - blcs 14bc34 │ │ │ │ - blcs 18bc1c │ │ │ │ - blcs 1cbc04 │ │ │ │ + blcs 8bd68 │ │ │ │ + blcs cbc5c │ │ │ │ + blcs 10bc44 │ │ │ │ + blcs 14bc2c │ │ │ │ + blcs 18bc14 │ │ │ │ + blcs 1cbbfc │ │ │ │ @ instruction: 0xf854d004 │ │ │ │ stmdacs r1, {r2, r8, sl, fp} │ │ │ │ stccc 8, cr13, [r1, #-388] @ 0xfffffe7c │ │ │ │ stceq 8, cr15, [r4, #-336] @ 0xfffffeb0 │ │ │ │ ldmdale ip, {r0, fp, sp}^ │ │ │ │ @ instruction: 0xf8543d01 │ │ │ │ stmdacs r1, {r2, r8, sl, fp} │ │ │ │ @@ -6765,158 +6763,158 @@ │ │ │ │ @ instruction: 0xf854af7f │ │ │ │ stccc 12, cr0, [r4], {4} │ │ │ │ stmdacs r1, {r1, r5, r9, sl, lr} │ │ │ │ ldmvs r3!, {r1, r2, r3, r4, r5, r7, r8, fp, ip, lr, pc} │ │ │ │ tstls r1, r1, lsl #26 │ │ │ │ stmdbls r1, {r3, r4, r7, r8, r9, sl, lr} │ │ │ │ orrle r1, r2, fp, ror #24 │ │ │ │ - blvs 1d11a78 │ │ │ │ - bvs ffc441c8 │ │ │ │ - blvs 1ce9b20 │ │ │ │ + blvs 1d11a70 │ │ │ │ + bvs ffc441c0 │ │ │ │ + blvs 1ce9b18 │ │ │ │ @ instruction: 0x46316af0 │ │ │ │ pop {r1, ip, sp, pc} │ │ │ │ @ instruction: 0x47184070 │ │ │ │ ldcllt 0, cr11, [r0, #-8]! │ │ │ │ cmnlt fp, r3, lsl #16 │ │ │ │ strmi r1, [r1], -r2, asr #24 │ │ │ │ ldmdavc r3, {r1, sp, lr, pc} │ │ │ │ cmplt r3, r1, lsl #4 │ │ │ │ - blcs be9524 │ │ │ │ + blcs be951c │ │ │ │ @ instruction: 0xf812d1f9 │ │ │ │ strmi r3, [r1], -r1, lsl #22 │ │ │ │ mvnsle r2, r0, lsl #22 │ │ │ │ @ instruction: 0x46084770 │ │ │ │ svclt 0x00004770 │ │ │ │ svclt 0x00eaf7ff │ │ │ │ @ instruction: 0x4604b510 │ │ │ │ stcpl 5, cr15, [r0, #692] @ 0x2b4 │ │ │ │ @ instruction: 0xf7f94669 │ │ │ │ - ldmdblt r0!, {r1, r2, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ + ldmdblt r0!, {r1, r3, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf50d4620 │ │ │ │ pop {r7, r8, sl, fp, ip, lr} │ │ │ │ @ instruction: 0xf7f94010 │ │ │ │ - @ instruction: 0xf7f9b9b1 │ │ │ │ - @ instruction: 0xf50de9b2 │ │ │ │ + @ instruction: 0xf7f9b9b5 │ │ │ │ + @ instruction: 0xf50de9b6 │ │ │ │ ldclt 13, cr5, [r0, #-512] @ 0xfffffe00 │ │ │ │ svclt 0x00182900 │ │ │ │ ldrlt r2, [r8, #-2048]! @ 0xfffff800 │ │ │ │ strmi sp, [r5], -r5 │ │ │ │ @ instruction: 0xf7f9460c │ │ │ │ - cmplt r0, r4, lsr r9 │ │ │ │ + cmplt r0, r8, lsr r9 │ │ │ │ tstcs r1, r8, lsr sp │ │ │ │ @ instruction: 0xf7f94608 │ │ │ │ - stmdacs r0, {r1, r2, r3, r5, r8, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r4, r5, r8, fp, sp, lr, pc} │ │ │ │ strcs sp, [r1], #-504 @ 0xfffffe08 │ │ │ │ - blx 1295e2 │ │ │ │ + blx 1295da │ │ │ │ @ instruction: 0xf7fdf005 │ │ │ │ - svclt 0x0000f983 │ │ │ │ + svclt 0x0000f987 │ │ │ │ ldrlt r2, [r0, #-2049] @ 0xfffff7ff │ │ │ │ andcs fp, r1, r8, lsr pc │ │ │ │ @ instruction: 0xf7f94604 │ │ │ │ - ldrdlt lr, [r0, -r0] │ │ │ │ + ldrdlt lr, [r0, -r4] │ │ │ │ @ instruction: 0x4620bd10 │ │ │ │ - @ instruction: 0xf976f7fd │ │ │ │ + @ instruction: 0xf97af7fd │ │ │ │ ldrlt r2, [r0, #-2305] @ 0xfffff6ff │ │ │ │ tstcs r1, r8, lsr pc │ │ │ │ stmdblt r0!, {r2, r3, r9, sl, lr} │ │ │ │ @ instruction: 0xf7f94608 │ │ │ │ - smlawtlt r0, r2, r9, lr │ │ │ │ + smlawtlt r0, r6, r9, lr │ │ │ │ @ instruction: 0xf7f9bd10 │ │ │ │ - stmdacs r0, {r4, r7, r8, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r2, r4, r7, r8, fp, sp, lr, pc} │ │ │ │ @ instruction: 0x4620d1fa │ │ │ │ - @ instruction: 0xf964f7fd │ │ │ │ + @ instruction: 0xf968f7fd │ │ │ │ @ instruction: 0x4605b538 │ │ │ │ - ldmib ip!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + b 55d74 │ │ │ │ strtmi r1, [r0], -r4, asr #24 │ │ │ │ @ instruction: 0xffdaf7ff │ │ │ │ strtmi r4, [r9], -r2, lsr #12 │ │ │ │ ldrhtmi lr, [r8], -sp │ │ │ │ - stmdblt r0, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdblt r4, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ cdpmi 6, 10, cr4, cr2, cr15, {0} │ │ │ │ ldrbtmi fp, [lr], #-130 @ 0xffffff7e │ │ │ │ andls r4, r0, sp, ror #12 │ │ │ │ - stmib r8!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib ip!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ strls r1, [r1, -r4, asr #24] │ │ │ │ ldmdavc r3, {r9, fp, ip, pc} │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ mrrcne 0, 8, r8, r7, cr8 │ │ │ │ ldmdavc r3, {r8, r9, sl, ip, pc} │ │ │ │ eorsle r2, r7, r5, lsr #22 │ │ │ │ - blcs 35f28 <__time64@plt+0x24c40> │ │ │ │ + blcs 35f20 <__time64@plt+0x24c38> │ │ │ │ ldcne 0, cr13, [r7], {127} @ 0x7f │ │ │ │ ldmdavc r3, {r8, r9, sl, ip, pc}^ │ │ │ │ eorle r2, pc, r5, lsr #22 │ │ │ │ - blcs 36038 <__time64@plt+0x24d50> │ │ │ │ + blcs 36030 <__time64@plt+0x24d48> │ │ │ │ ldclne 0, cr13, [r7], {119} @ 0x77 │ │ │ │ ldmvc r3, {r8, r9, sl, ip, pc} │ │ │ │ eorle r2, r7, r5, lsr #22 │ │ │ │ - blcs 36148 <__time64@plt+0x24e60> │ │ │ │ + blcs 36140 <__time64@plt+0x24e58> │ │ │ │ ldcne 0, cr13, [r7, #-444] @ 0xfffffe44 │ │ │ │ ldmvc r3, {r8, r9, sl, ip, pc}^ │ │ │ │ andsle r2, pc, r5, lsr #22 │ │ │ │ - blcs 36258 <__time64@plt+0x24f70> │ │ │ │ + blcs 36250 <__time64@plt+0x24f68> │ │ │ │ ldclne 0, cr13, [r7, #-412] @ 0xfffffe64 │ │ │ │ strls r2, [r0, -r5, lsr #22] │ │ │ │ ldmdbvc r3, {r3, r4, ip, lr, pc}^ │ │ │ │ rsble r2, r0, r0, lsl #22 │ │ │ │ - blcs 95f47c │ │ │ │ + blcs 95f474 │ │ │ │ andsle r9, r1, r0, lsl #14 │ │ │ │ - blcs 36474 <__time64@plt+0x2518c> │ │ │ │ + blcs 3646c <__time64@plt+0x25184> │ │ │ │ ldclne 0, cr13, [r7, #356] @ 0x164 │ │ │ │ strls r2, [r0, -r5, lsr #22] │ │ │ │ ldrtmi sp, [fp], -sl │ │ │ │ - blcs 95e84 │ │ │ │ - bcs 296b8 <__time64@plt+0x183d0> │ │ │ │ + blcs 95e7c │ │ │ │ + bcs 296b0 <__time64@plt+0x183c8> │ │ │ │ movwls sp, #79 @ 0x4f │ │ │ │ stccs 8, cr15, [r1], {19} │ │ │ │ mvnsle r2, r5, lsr #20 │ │ │ │ mulhi r0, r7, r8 │ │ │ │ @ instruction: 0x46414630 │ │ │ │ - stmib r4!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmib r8!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ @ instruction: 0xf1b880c5 │ │ │ │ @ instruction: 0xf0000f2a │ │ │ │ andcs r8, sl, #179 @ 0xb3 │ │ │ │ ldrtmi r4, [r8], -r9, lsr #12 │ │ │ │ - stmia sl!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmia lr!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdaeq r0, {r2, r8, r9, fp, sp, lr, pc} │ │ │ │ ldmdavc sl, {r8, r9, fp, ip, pc} │ │ │ │ @ instruction: 0xf0002a2e │ │ │ │ strhcs r8, [r0, -r8] │ │ │ │ @ instruction: 0xf817461f │ │ │ │ @ instruction: 0xf1a33b01 │ │ │ │ - blcs 1318828 │ │ │ │ + blcs 1318820 │ │ │ │ addhi pc, r9, r0 │ │ │ │ ldmdacs r2, {r4, r6, r7, r9, ip, sp, pc} │ │ │ │ - bcs 4cdf38 │ │ │ │ + bcs 4cdf30 │ │ │ │ ldm pc, {r0, r1, r3, fp, ip, lr, pc}^ @ │ │ │ │ - beq fe553ea4 │ │ │ │ - beq fe09a6c8 │ │ │ │ + beq fe553e9c │ │ │ │ + beq fe09a6c0 │ │ │ │ + beq 29a6c4 │ │ │ │ + beq fee1a6c8 │ │ │ │ beq 29a6cc │ │ │ │ - beq fee1a6d0 │ │ │ │ - beq 29a6d4 │ │ │ │ - blcc 1a580fc │ │ │ │ + blcc 1a580f4 │ │ │ │ ldreq pc, [lr], #-264 @ 0xfffffef8 │ │ │ │ - blcs 444a24 │ │ │ │ + blcs 444a1c │ │ │ │ andcs sp, r1, #15 │ │ │ │ subeq pc, r1, r9, asr #4 │ │ │ │ andmi r4, r2, #154 @ 0x9a │ │ │ │ stmdbcs r4, {r0, r1, r2, r3, r5, r6, ip, lr, pc} │ │ │ │ ldm pc, {r0, r1, r2, fp, ip, lr, pc}^ @ │ │ │ │ movweq pc, #12289 @ 0x3001 @ │ │ │ │ andeq r0, r3, r1, ror #6 │ │ │ │ movwcc r9, #19201 @ 0x4b01 │ │ │ │ strls r9, [r0, -r1, lsl #6] │ │ │ │ @ instruction: 0x4620e772 │ │ │ │ pop {r1, ip, sp, pc} │ │ │ │ @ instruction: 0xf10881f0 │ │ │ │ - blcs 19d8f64 │ │ │ │ - blcs 114e2c4 │ │ │ │ - blcc 118e6c0 │ │ │ │ + blcs 19d8f5c │ │ │ │ + blcs 114e2bc │ │ │ │ + blcc 118e6b8 │ │ │ │ ldmle r0!, {r1, r5, r8, r9, fp, sp}^ │ │ │ │ @ instruction: 0xf852a202 │ │ │ │ ldrmi r3, [sl], #-35 @ 0xffffffdd │ │ │ │ svclt 0x00004710 │ │ │ │ andeq r0, r0, fp, lsl #2 │ │ │ │ @ instruction: 0xffffffd7 │ │ │ │ andeq r0, r0, fp, lsl #2 │ │ │ │ @@ -6958,15 +6956,15 @@ │ │ │ │ @ instruction: 0x3101e79d │ │ │ │ smladxls r0, fp, r6, r4 │ │ │ │ @ instruction: 0xf012e76a │ │ │ │ orrsle r0, r3, r0, lsr #31 │ │ │ │ orrsle r2, r4, sl, lsl #22 │ │ │ │ vldrne d9, [sl, #-4] │ │ │ │ ldmdavs r8, {r0, r9, ip, pc} │ │ │ │ - stmia sl!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia lr!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ str r4, [ip, r4, lsl #8] │ │ │ │ ldrtmi r2, [fp], -r3, lsl #2 │ │ │ │ ldrb r9, [r9, -r0, lsl #14] │ │ │ │ strcc r9, [r1, -r1, lsl #22] │ │ │ │ ldcne 7, cr9, [sl, #-0] │ │ │ │ @ instruction: 0xf8d39201 │ │ │ │ @ instruction: 0xf1b88000 │ │ │ │ @@ -6979,48 +6977,48 @@ │ │ │ │ tstle r6, sl, lsr #20 │ │ │ │ movwcc r9, #10753 @ 0x2a01 │ │ │ │ ldcne 3, cr9, [r1, #-0] │ │ │ │ ldmdavs r2, {r0, r8, ip, pc} │ │ │ │ svclt 0x00b82a00 │ │ │ │ ldrmi r4, [r0], #594 @ 0x252 │ │ │ │ tstcs r4, r7, lsr r7 │ │ │ │ - blls 91f74 │ │ │ │ + blls 91f6c │ │ │ │ @ instruction: 0xf0233307 │ │ │ │ movwcc r0, #33543 @ 0x8307 │ │ │ │ @ instruction: 0xf508b951 │ │ │ │ movwls r7, #5289 @ 0x14a9 │ │ │ │ andcs lr, sl, #23855104 @ 0x16c0000 │ │ │ │ @ instruction: 0xf7f84669 │ │ │ │ - blls 53f5c │ │ │ │ + blls 53f64 │ │ │ │ str r4, [r4, -r0, lsl #9]! │ │ │ │ ldrpl pc, [fp], #1288 @ 0x508 │ │ │ │ strcc r9, [r2], #-769 @ 0xfffffcff │ │ │ │ svclt 0x0000e74f │ │ │ │ andeq r6, r1, r2, asr #21 │ │ │ │ - bleq 54180 │ │ │ │ + bleq 54178 │ │ │ │ cdpeq 0, 0, cr15, cr0, cr15, {2} │ │ │ │ strbtmi fp, [sl], -r2, lsl #24 │ │ │ │ strlt fp, [r1], #-1028 @ 0xfffffbfc │ │ │ │ @ instruction: 0xa018f8df │ │ │ │ ldrmi sl, [sl], #773 @ 0x305 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ stmdami r4, {r3, sl, ip, sp, pc} │ │ │ │ andeq pc, r0, sl, asr r8 @ │ │ │ │ - svc 0x00b8f7f8 │ │ │ │ - stmdb lr!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - muleq r3, r8, pc @ │ │ │ │ + svc 0x00bcf7f8 │ │ │ │ + ldmdb r2!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + andeq r7, r3, r0, lsr #31 │ │ │ │ andeq r0, r0, r4, asr #2 │ │ │ │ - ldr r3, [pc, #20] @ 1808c <__time64@plt+0x6da4> │ │ │ │ - ldr r2, [pc, #20] @ 18090 <__time64@plt+0x6da8> │ │ │ │ + ldr r3, [pc, #20] @ 18084 <__time64@plt+0x6d9c> │ │ │ │ + ldr r2, [pc, #20] @ 18088 <__time64@plt+0x6da0> │ │ │ │ add r3, pc, r3 │ │ │ │ ldr r2, [r3, r2] │ │ │ │ cmp r2, #0 │ │ │ │ bxeq lr │ │ │ │ b 1112c <__gmon_start__@plt> │ │ │ │ - andeq r7, r3, r0, lsl #31 │ │ │ │ + andeq r7, r3, r8, lsl #31 │ │ │ │ andeq r0, r0, r4, lsr r1 │ │ │ │ sbcscc pc, r0, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ bicscc pc, r0, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ andle r4, r5, r3, lsl #5 │ │ │ │ movweq pc, #576 @ 0x240 @ │ │ │ │ @@ -7043,351 +7041,351 @@ │ │ │ │ stmdavc r3!, {r0, r2, sl} │ │ │ │ @ instruction: 0xf7ffb91b │ │ │ │ movwcs pc, #8143 @ 0x1fcf @ │ │ │ │ ldclt 0, cr7, [r0, #-140] @ 0xffffff74 │ │ │ │ svclt 0x0000e7dc │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ @ instruction: 0x4605213c │ │ │ │ - stmda r6, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda sl, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ teqcs sl, r0, lsr #18 │ │ │ │ @ instruction: 0xf7f94628 │ │ │ │ - tstlt r8, #4325376 @ 0x420000 │ │ │ │ + tstlt r8, #4587520 @ 0x460000 │ │ │ │ strcs r4, [r5], -r8, lsr #12 │ │ │ │ ldreq pc, [r5], -r0, asr #5 │ │ │ │ mrc2 7, 1, pc, cr4, cr15, {7} │ │ │ │ strmi r2, [r5], -r0, lsl #8 │ │ │ │ ldrbcs r4, [pc, -r0, lsl #13] │ │ │ │ @ instruction: 0xf7f94628 │ │ │ │ - adcmi lr, r0, #3014656 @ 0x2e0000 │ │ │ │ + adcmi lr, r0, #3276800 @ 0x320000 │ │ │ │ @ instruction: 0xf898d914 │ │ │ │ strcc r3, [r1], #-0 │ │ │ │ sbcslt r3, fp, #43008 @ 0xa800 │ │ │ │ stmdale r6, {r2, r4, r8, r9, fp, sp} │ │ │ │ vpmax.u8 d15, d3, d22 │ │ │ │ svclt 0x004807db │ │ │ │ - blvc 96174 │ │ │ │ + blvc 9616c │ │ │ │ strtmi sp, [r8], -ip, ror #9 │ │ │ │ stmdaeq r1, {r3, r8, ip, sp, lr, pc} │ │ │ │ - ldmda r8, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda ip, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiale sl!, {r5, r7, r9, lr}^ │ │ │ │ pop {r3, r5, r9, sl, lr} │ │ │ │ svclt 0x000081f0 │ │ │ │ ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ @ instruction: 0xf7f94680 │ │ │ │ - vadd.i8 d30, d0, d14 │ │ │ │ + vtst.8 d30, d0, d2 │ │ │ │ vrsra.s64 , q8, #64 │ │ │ │ @ instruction: 0xf8d30305 │ │ │ │ @ instruction: 0xf1b99000 │ │ │ │ eorle r0, pc, r0, lsl #30 │ │ │ │ @ instruction: 0x4607685b │ │ │ │ @ instruction: 0xf0192600 │ │ │ │ @ instruction: 0xf1a30203 │ │ │ │ subsle r0, fp, r4, lsl #10 │ │ │ │ andsle r2, r7, r1, lsl #20 │ │ │ │ andle r2, r8, r2, lsl #20 │ │ │ │ @ instruction: 0x461d681c │ │ │ │ @ instruction: 0xf7f84620 │ │ │ │ - addmi lr, r7, #244, 30 @ 0x3d0 │ │ │ │ + addmi lr, r7, #248, 30 @ 0x3e0 │ │ │ │ addhi pc, r3, r0, lsl #4 │ │ │ │ @ instruction: 0xf8552601 │ │ │ │ strtmi r4, [r0], -r4, lsl #30 │ │ │ │ - svc 0x00eaf7f8 │ │ │ │ + svc 0x00eef7f8 │ │ │ │ stmdble r4, {r0, r1, r2, r7, r9, lr} │ │ │ │ andcc pc, r0, r8, lsl r8 @ │ │ │ │ @ instruction: 0xf0002b2f │ │ │ │ strcc r8, [r1], -r5, lsl #1 │ │ │ │ svcmi 0x0004f855 │ │ │ │ @ instruction: 0xf7f84620 │ │ │ │ - addmi lr, r7, #888 @ 0x378 │ │ │ │ + addmi lr, r7, #904 @ 0x388 │ │ │ │ @ instruction: 0xf818d903 │ │ │ │ - blcs be41e0 │ │ │ │ + blcs be41d8 │ │ │ │ @ instruction: 0x3601d05e │ │ │ │ teqle r3, lr, asr #10 │ │ │ │ rscscc pc, pc, pc, asr #32 │ │ │ │ @ instruction: 0x87f0e8bd │ │ │ │ strtmi r4, [r1], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7f84640 │ │ │ │ - stmdacs r0, {r1, r2, r3, r5, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r4, r5, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ stmdavs ip!, {r0, r1, r3, r4, r5, ip, lr, pc}^ │ │ │ │ ldrtmi r3, [r2], r1, lsl #12 │ │ │ │ @ instruction: 0xf7f84620 │ │ │ │ - addmi lr, r7, #196, 30 @ 0x310 │ │ │ │ + addmi lr, r7, #200, 30 @ 0x320 │ │ │ │ @ instruction: 0xf818d903 │ │ │ │ - blcs be4214 │ │ │ │ + blcs be420c │ │ │ │ stmiavs ip!, {r3, r5, ip, lr, pc} │ │ │ │ streq pc, [r1], -sl, lsl #2 │ │ │ │ @ instruction: 0xf7f84620 │ │ │ │ - addmi lr, r7, #184, 30 @ 0x2e0 │ │ │ │ + addmi lr, r7, #188, 30 @ 0x2f0 │ │ │ │ @ instruction: 0xf818d903 │ │ │ │ - blcs be422c │ │ │ │ + blcs be4224 │ │ │ │ stmiavs ip!, {r1, r2, r5, ip, lr, pc}^ │ │ │ │ streq pc, [r2], -sl, lsl #2 │ │ │ │ strtmi r3, [r0], -ip, lsl #10 │ │ │ │ - svc 0x00aaf7f8 │ │ │ │ + svc 0x00aef7f8 │ │ │ │ stmdble r3, {r0, r1, r2, r7, r9, lr} │ │ │ │ andcc pc, r0, r8, lsl r8 @ │ │ │ │ eorle r2, r2, pc, lsr #22 │ │ │ │ streq pc, [r3], -sl, lsl #2 │ │ │ │ sbcle r4, fp, lr, asr #10 │ │ │ │ strcc r6, [r4, #-2156] @ 0xfffff794 │ │ │ │ @ instruction: 0xf7f84620 │ │ │ │ - addmi lr, r7, #156, 30 @ 0x270 │ │ │ │ + addmi lr, r7, #160, 30 @ 0x280 │ │ │ │ @ instruction: 0xf818d9cf │ │ │ │ - blcs be4264 │ │ │ │ + blcs be425c │ │ │ │ strb sp, [r3, fp, asr #3] │ │ │ │ strtmi r4, [r1], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7f84640 │ │ │ │ - stmdacs r0, {r1, r4, r5, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r4, r5, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ ldrtmi sp, [r0], -pc, asr #3 │ │ │ │ @ instruction: 0x87f0e8bd │ │ │ │ strtmi r4, [r1], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7f84640 │ │ │ │ - stmdacs r0, {r3, r5, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r2, r3, r5, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0x4630d1d1 │ │ │ │ @ instruction: 0x4602e7f4 │ │ │ │ strbmi r4, [r0], -r1, lsr #12 │ │ │ │ - mrc 7, 6, APSR_nzcv, cr14, cr8, {7} │ │ │ │ + mcr 7, 7, pc, cr2, cr8, {7} @ │ │ │ │ bicsle r2, r5, r0, lsl #16 │ │ │ │ @ instruction: 0xe7eb4630 │ │ │ │ strtmi r4, [r1], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7f84640 │ │ │ │ - stmdacs r0, {r1, r2, r4, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r3, r4, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ strcc sp, [r1], -r3, ror #1 │ │ │ │ bicle r4, sp, lr, asr #10 │ │ │ │ @ instruction: 0xf818e798 │ │ │ │ - blcs be42bc │ │ │ │ + blcs be42b4 │ │ │ │ svcge 0x0078f47f │ │ │ │ strtmi r4, [r1], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7f84640 │ │ │ │ - stmdacs r0, {r1, r2, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r3, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ svcge 0x0070f47f │ │ │ │ @ instruction: 0xe7d14630 │ │ │ │ strtmi r4, [r1], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7f84640 │ │ │ │ - stmdacs r0, {r2, r3, r4, r5, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ svcge 0x0073f47f │ │ │ │ svclt 0x0000e7c7 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ ldrbtcc pc, [r0], r0, asr #4 @ │ │ │ │ streq pc, [r5], -r0, asr #5 │ │ │ │ pkhbtmi fp, r1, r3, lsl #1 │ │ │ │ ldrmi r4, [r5], -pc, lsl #12 │ │ │ │ - blcs 325cc <__time64@plt+0x212e4> │ │ │ │ + blcs 325c4 <__time64@plt+0x212dc> │ │ │ │ adchi pc, r4, r0, asr #32 │ │ │ │ stmdage r6, {r9, sp} │ │ │ │ vmin.s8 d20, d1, d1 │ │ │ │ vorr.i32 d16, #3072 @ 0x00000c00 │ │ │ │ movwls r0, #769 @ 0x301 │ │ │ │ - cmpppl r1, #74448896 @ p-variant is OBSOLETE @ 0x4700000 │ │ │ │ + movtpl pc, #38471 @ 0x9647 @ │ │ │ │ movweq pc, #4800 @ 0x12c0 @ │ │ │ │ - mrc 7, 5, APSR_nzcv, cr12, cr8, {7} │ │ │ │ + mcr 7, 6, pc, cr0, cr8, {7} @ │ │ │ │ stccs 8, cr7, [r0], {44} @ 0x2c │ │ │ │ @ instruction: 0xf642d040 │ │ │ │ - @ instruction: 0xf2c028d0 │ │ │ │ + vmul.i d18, d16, d0[2] │ │ │ │ and r0, sl, r3, lsl #16 │ │ │ │ andcc lr, r9, #3620864 @ 0x374000 │ │ │ │ mlsle r8, sl, r2, r4 │ │ │ │ andls r1, r9, #23040 @ 0x5a00 │ │ │ │ andsvc r4, ip, sl, lsr #12 │ │ │ │ ldmdavc r4, {r0, r2, r4, r6, sl, fp, ip}^ │ │ │ │ stccs 3, cr11, [r4], #-528 @ 0xfffffdf0 │ │ │ │ stmdavc fp!, {r1, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ subsle r2, r4, r4, lsr #22 │ │ │ │ andscs pc, r3, r8, lsr r8 @ │ │ │ │ @ instruction: 0xf1400752 │ │ │ │ @ instruction: 0xf1a380cd │ │ │ │ - bl 1db020 │ │ │ │ + bl 1db018 │ │ │ │ @ instruction: 0xf85702cb │ │ │ │ ldmdavs r4, {r0, r1, r3, r4, r5, sp, pc}^ │ │ │ │ - bcs 32634 <__time64@plt+0x2134c> │ │ │ │ - b 1c0c8bc │ │ │ │ + bcs 3262c <__time64@plt+0x21344> │ │ │ │ + b 1c0c8b4 │ │ │ │ strmi r0, [r2, #778]! @ 0x30a │ │ │ │ bicsvc lr, r3, #323584 @ 0x4f000 │ │ │ │ movwcs fp, #4040 @ 0xfc8 │ │ │ │ ldmib sp, {r0, r1, r3, r4, r5, r6, r8, ip, sp, pc}^ │ │ │ │ - bl fe918fa8 │ │ │ │ - bne 6d93b0 │ │ │ │ + bl fe918fa0 │ │ │ │ + bne 6d93a8 │ │ │ │ vqsub.s8 d4, d16, d12 │ │ │ │ - bl 27862c │ │ │ │ + bl 278624 │ │ │ │ strtmi r0, [r2], -sl, lsl #2 │ │ │ │ - mcr 7, 2, pc, cr12, cr8, {7} @ │ │ │ │ + mrc 7, 2, APSR_nzcv, cr0, cr8, {7} │ │ │ │ strtmi r9, [r3], #-2825 @ 0xfffff4f7 │ │ │ │ stmiavc ip!, {r0, r3, r8, r9, ip, pc} │ │ │ │ mrrcne 12, 6, r1, r5, cr10 │ │ │ │ bicle r2, lr, r0, lsl #24 │ │ │ │ andcc lr, r9, #3620864 @ 0x374000 │ │ │ │ @ instruction: 0xd07f429a │ │ │ │ andcs r1, r0, #22784 @ 0x5900 │ │ │ │ andsvc r9, sl, r9, lsl #2 │ │ │ │ movweq lr, #35293 @ 0x89dd │ │ │ │ @ instruction: 0xf0004298 │ │ │ │ - bls 3385d8 │ │ │ │ + bls 3385d0 │ │ │ │ ldrmi r9, [r3], #-2314 @ 0xfffff6f6 │ │ │ │ movweq lr, #10787 @ 0x2a23 │ │ │ │ - bne fe73ebec │ │ │ │ + bne fe73ebe4 │ │ │ │ addsmi r1, r4, #565248 @ 0x8a000 │ │ │ │ stmib sp, {r2, r3, r7, r8, r9, sl, fp, ip, sp, pc}^ │ │ │ │ stmib sp, {r3, r8, ip}^ │ │ │ │ @ instruction: 0xf7ff3308 │ │ │ │ ldrdcs pc, [r0, -r7] │ │ │ │ stmdage r6, {r2, r9, sl, lr} │ │ │ │ - svc 0x000ef7f8 │ │ │ │ - blcs 326bc <__time64@plt+0x213d4> │ │ │ │ + svc 0x0012f7f8 │ │ │ │ + blcs 326b4 <__time64@plt+0x213cc> │ │ │ │ strtmi sp, [r0], -r4, asr #2 │ │ │ │ pop {r0, r1, r4, ip, sp, pc} │ │ │ │ ldmib sp, {r4, r5, r6, r7, r8, r9, sl, fp, pc}^ │ │ │ │ addsmi r3, sl, #-1879048192 @ 0x90000000 │ │ │ │ mrrcne 0, 7, sp, sl, cr2 │ │ │ │ andsvc r9, ip, r9, lsl #4 │ │ │ │ smlabtcs r1, r9, r7, lr │ │ │ │ @ instruction: 0xf7f8a806 │ │ │ │ - blls 293cb4 │ │ │ │ + blls 293cbc │ │ │ │ vaba.s8 d30, d16, d0 │ │ │ │ vrshr.s64 , q4, #64 │ │ │ │ @ instruction: 0xf6480205 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ ldmdavs r3, {r1} │ │ │ │ @ instruction: 0xf7ff9305 │ │ │ │ @ instruction: 0xf8cdfc51 │ │ │ │ strmi fp, [r2], -r8 │ │ │ │ strge lr, [r0], #-2509 @ 0xfffff633 │ │ │ │ teqpeq r6, #64, 12 @ p-variant is OBSOLETE @ 0x4000000 │ │ │ │ @ instruction: 0xf6489805 │ │ │ │ - vorr.i32 , #0 @ 0x00000000 │ │ │ │ + vmla.f d17, d0, d0[2] │ │ │ │ @ instruction: 0xf7f80102 │ │ │ │ - @ instruction: 0xe790eeb2 │ │ │ │ + @ instruction: 0xe790eeb6 │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ff681c │ │ │ │ @ instruction: 0xf8cdfc37 │ │ │ │ strmi r9, [r2], -r0 │ │ │ │ - teqpne ip, r8, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqpne r4, r8, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf6404620 │ │ │ │ @ instruction: 0xf7f80323 │ │ │ │ - @ instruction: 0xe743ee9a │ │ │ │ + @ instruction: 0xe743ee9e │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ff681d │ │ │ │ strls pc, [r0], #-3103 @ 0xfffff3e1 │ │ │ │ @ instruction: 0xf6404602 │ │ │ │ strtmi r0, [r8], -r9, asr #6 │ │ │ │ - orrsne pc, r0, r8, asr #12 │ │ │ │ + orrne pc, r8, r8, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - mcr 7, 4, pc, cr2, cr8, {7} @ │ │ │ │ + mcr 7, 4, pc, cr6, cr8, {7} @ │ │ │ │ andslt r4, r3, r0, lsr #12 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ stmdage r6, {r0, r8, sp} │ │ │ │ - ldcl 7, cr15, [r4, #992] @ 0x3e0 │ │ │ │ + ldcl 7, cr15, [r8, #992] @ 0x3e0 │ │ │ │ andcs r9, r0, #9216 @ 0x2400 │ │ │ │ tstls r9, r9, asr ip │ │ │ │ ldmib sp, {r1, r3, r4, ip, sp, lr}^ │ │ │ │ addmi r0, r3, #8, 6 @ 0x20000000 │ │ │ │ svcge 0x007bf47f │ │ │ │ umaalcs pc, r0, sp, r8 @ │ │ │ │ @ instruction: 0xf0424603 │ │ │ │ @ instruction: 0xf88d0202 │ │ │ │ ldrb r2, [r2, -r0, asr #32]! │ │ │ │ strtmi sl, [r1], -r6, lsl #16 │ │ │ │ - ldc 7, cr15, [lr, #992]! @ 0x3e0 │ │ │ │ + stcl 7, cr15, [r2, #992] @ 0x3e0 │ │ │ │ ldrb r9, [r2, -r9, lsl #16] │ │ │ │ stmdage r6, {r0, r8, sp} │ │ │ │ - ldc 7, cr15, [r8, #992]! @ 0x3e0 │ │ │ │ + ldc 7, cr15, [ip, #992]! @ 0x3e0 │ │ │ │ str r9, [r6, r9, lsl #22] │ │ │ │ - rsbsne pc, r0, #72, 12 @ 0x4800000 │ │ │ │ + rsbne pc, r8, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ teqpeq sp, r0, asr #12 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0xffdef7f8 │ │ │ │ + @ instruction: 0xffe2f7f8 │ │ │ │ vqrshl.s8 d27, d0, d0 │ │ │ │ vmls.i d23, d0, d0[3] │ │ │ │ @ instruction: 0xf6480405 │ │ │ │ - vshr.s64 d17, d16, #64 │ │ │ │ + vaddl.s8 , d16, d24 │ │ │ │ stmdavs r1!, {r1} │ │ │ │ - ldcl 7, cr15, [r0, #-992]! @ 0xfffffc20 │ │ │ │ - adcsne pc, ip, r8, asr #12 │ │ │ │ + ldcl 7, cr15, [r4, #-992]! @ 0xfffffc20 │ │ │ │ + adcsne pc, r4, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - stcl 7, cr15, [r2, #992]! @ 0x3e0 │ │ │ │ + stcl 7, cr15, [r6, #992]! @ 0x3e0 │ │ │ │ @ instruction: 0xf6486821 │ │ │ │ - vmla.i d17, d16, d0[4] │ │ │ │ + vshr.s64 , q4, #64 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xf648ed64 │ │ │ │ - vmov.i32 d18, #12 @ 0x0000000c │ │ │ │ + @ instruction: 0xf648ed68 │ │ │ │ + vmov.i32 d18, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xf648edd6 │ │ │ │ - vmla.i d18, d0, d0[3] │ │ │ │ + @ instruction: 0xf648edda │ │ │ │ + vmla.i d18, d0, d0[1] │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xf648edd0 │ │ │ │ - vshr.s64 d18, d4, #64 │ │ │ │ + @ instruction: 0xf648edd4 │ │ │ │ + vaddl.s8 q9, d16, d12 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xf648edca │ │ │ │ - vmla.i d18, d16, d0[0] │ │ │ │ + @ instruction: 0xf648edce │ │ │ │ + vshr.s64 d18, d24, #64 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xf648edc4 │ │ │ │ - vaddl.s8 , d0, d8 │ │ │ │ + @ instruction: 0xf648edc8 │ │ │ │ + vaddl.s8 , d0, d0 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xf648edbe │ │ │ │ - vmov.i32 , #0 @ 0x00000000 │ │ │ │ + @ instruction: 0xf648edc2 │ │ │ │ + vmla.i d19, d0, d0[2] │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xf648edb8 │ │ │ │ - vaddl.s8 , d16, d20 │ │ │ │ + @ instruction: 0xf648edbc │ │ │ │ + vshr.s64 d19, d12, #64 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xf648edb2 │ │ │ │ - vshr.s64 , q8, #64 │ │ │ │ + @ instruction: 0xf648edb6 │ │ │ │ + vmla.i d19, d16, d0[6] │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xf648edac │ │ │ │ - vaddl.s8 q10, d0, d28 │ │ │ │ + @ instruction: 0xf648edb0 │ │ │ │ + vaddl.s8 q10, d0, d20 │ │ │ │ ldmfd sp!, {r1} │ │ │ │ @ instruction: 0xf7f84010 │ │ │ │ - svclt 0x0000bda1 │ │ │ │ + svclt 0x0000bda5 │ │ │ │ svclt 0x00182900 │ │ │ │ strlt r2, [r8, #-2048] @ 0xfffff800 │ │ │ │ tstcc r9, r7 │ │ │ │ @ instruction: 0xf7fe3009 │ │ │ │ - blx fec57bf0 │ │ │ │ + blx fec57bf8 │ │ │ │ stmdbeq r0, {r7, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf648bd08 │ │ │ │ - vmlal.s q10, d0, d0[5] │ │ │ │ + vmov.i32 q10, #3072 @ 0x00000c00 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d1, d2 │ │ │ │ @ instruction: 0xf7f84142 │ │ │ │ - svclt 0x0000ff73 │ │ │ │ + svclt 0x0000ff77 │ │ │ │ andcc fp, r9, r0, lsl r1 │ │ │ │ - mrclt 7, 2, APSR_nzcv, cr2, cr14, {7} │ │ │ │ - rsbsmi pc, r8, #72, 12 @ 0x4800000 │ │ │ │ + mrclt 7, 2, APSR_nzcv, cr6, cr14, {7} │ │ │ │ + rsbsmi pc, r0, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ vrshl.s8 d27, d8, d1 │ │ │ │ @ instruction: 0xf7f84139 │ │ │ │ - svclt 0x0000ff61 │ │ │ │ + svclt 0x0000ff65 │ │ │ │ vqrshl.s8 , q12, q8 │ │ │ │ @ instruction: 0xf2c036f0 │ │ │ │ strmi r0, [r5], -r5, lsl #12 │ │ │ │ @ instruction: 0xb32c68f4 │ │ │ │ strtmi r6, [r8], -r1, ror #18 │ │ │ │ - stcl 7, cr15, [r4], #992 @ 0x3e0 │ │ │ │ + stcl 7, cr15, [r8], #992 @ 0x3e0 │ │ │ │ stmdavs r3!, {r4, r6, r8, fp, ip, sp, pc} │ │ │ │ andle r2, r7, r5, lsl #22 │ │ │ │ andle r2, r1, r9, lsl #22 │ │ │ │ ldcllt 6, cr4, [r8, #128]! @ 0x80 │ │ │ │ ldmdavs fp, {r0, r1, r5, r6, r7, r9, fp, sp, lr} │ │ │ │ mvnsle r2, r5, lsl #22 │ │ │ │ tstlt fp, r3, ror #16 │ │ │ │ @ instruction: 0xe7eb461c │ │ │ │ ldmdbvs r3!, {r0, r1, r2, r5, r8, sl, fp, ip} │ │ │ │ andcs r2, r1, r0, asr #2 │ │ │ │ teqvs r3, r1, lsl #6 │ │ │ │ - blx 1ad664e │ │ │ │ + blx 1ad6646 │ │ │ │ @ instruction: 0x46046933 │ │ │ │ andcs r6, r4, #1073741841 @ 0x40000011 │ │ │ │ andvs r4, r2, fp, asr r2 │ │ │ │ eorsvs r6, r8, r3, lsl #1 │ │ │ │ ldcllt 6, cr4, [r8, #128]! @ 0x80 │ │ │ │ streq pc, [ip, -r6, lsl #2] │ │ │ │ svclt 0x0000e7eb │ │ │ │ @@ -7395,436 +7393,436 @@ │ │ │ │ vorr.i32 d23, #2048 @ 0x00000800 │ │ │ │ ldrlt r0, [r0, #-773]! @ 0xfffffcfb │ │ │ │ addlt r6, r2, sl, lsl r8 │ │ │ │ vcgt.s8 , q0, q9 │ │ │ │ @ instruction: 0xf2c034d8 │ │ │ │ ldmdavs fp, {r0, r2, sl}^ │ │ │ │ @ instruction: 0xf6483209 │ │ │ │ - vsra.s64 d20, d12, #64 │ │ │ │ + vsra.s64 d20, d4, #64 │ │ │ │ stmdavs r0!, {r1, r8} │ │ │ │ strls sl, [r1, #-3334] @ 0xfffff2fa │ │ │ │ - stc 7, cr15, [r8, #992] @ 0x3e0 │ │ │ │ - bls 7eab4 │ │ │ │ + stc 7, cr15, [ip, #992] @ 0x3e0 │ │ │ │ + bls 7eaac │ │ │ │ @ instruction: 0xf7f86820 │ │ │ │ - stmdavs r0!, {r1, r2, r3, r4, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdavs r0!, {r1, r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ andcc lr, r5, #208, 18 @ 0x340000 │ │ │ │ svclt 0x003f4293 │ │ │ │ andcs r1, sl, #22784 @ 0x5900 │ │ │ │ andsvc r6, sl, r1, asr #2 │ │ │ │ vhsub.s8 d29, d0, d10 │ │ │ │ vrsra.s64 , q8, #64 │ │ │ │ andcs r0, r1, #335544320 @ 0x14000000 │ │ │ │ andlt r7, r2, sl, lsl r5 │ │ │ │ ldrhtmi lr, [r0], -sp │ │ │ │ ldrbmi fp, [r0, -r3]! │ │ │ │ @ instruction: 0xf7f8210a │ │ │ │ - @ instruction: 0xe7f0edba │ │ │ │ - addmi pc, ip, #72, 12 @ 0x4800000 │ │ │ │ + @ instruction: 0xe7f0edbe │ │ │ │ + addmi pc, r4, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f8216f │ │ │ │ - svclt 0x0000feed │ │ │ │ + svclt 0x0000fef1 │ │ │ │ @ instruction: 0x460cb530 │ │ │ │ strmi r4, [r1], -r5, lsl #12 │ │ │ │ stmdavs r3!, {r0, r1, r7, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf6482220 │ │ │ │ - vaddl.s8 q10, d16, d20 │ │ │ │ + vshr.s64 d20, d12, #64 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - stmiavs r1!, {r1, r2, r3, r4, r5, r6, sl, fp, sp, lr, pc} │ │ │ │ + stmiavs r1!, {r1, r7, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf0004628 │ │ │ │ ldmib r4, {r0, r3, r4, r5, fp, ip, sp, lr, pc}^ │ │ │ │ tstlt r3, r3, lsl #2 │ │ │ │ eorcs r3, r0, #603979776 @ 0x24000000 │ │ │ │ @ instruction: 0xf6489100 │ │ │ │ - vshr.s64 d20, d24, #64 │ │ │ │ + vshr.s64 d20, d16, #64 │ │ │ │ strtmi r0, [r9], -r2 │ │ │ │ - stcl 7, cr15, [ip], #-992 @ 0xfffffc20 │ │ │ │ + ldcl 7, cr15, [r0], #-992 @ 0xfffffc20 │ │ │ │ strtmi r6, [r8], -r1, ror #18 │ │ │ │ @ instruction: 0xf9d8f000 │ │ │ │ eorcs r6, r0, #6488064 @ 0x630000 │ │ │ │ @ instruction: 0xf6484629 │ │ │ │ - vshr.s64 q10, q6, #64 │ │ │ │ + vshr.s64 q10, q2, #64 │ │ │ │ andlt r0, r3, r2 │ │ │ │ ldrhtmi lr, [r0], -sp │ │ │ │ - mrrclt 7, 15, pc, sl, cr8 @ │ │ │ │ + mrrclt 7, 15, pc, lr, cr8 @ │ │ │ │ @ instruction: 0x4605b538 │ │ │ │ @ instruction: 0xf649460c │ │ │ │ - vaddl.s8 q9, d16, d0 │ │ │ │ + vmvn.i32 q9, #8 @ 0x00000008 │ │ │ │ strtmi r0, [r9], -r2 │ │ │ │ - mrrc 7, 15, pc, r2, cr8 @ │ │ │ │ + mrrc 7, 15, pc, r6, cr8 @ │ │ │ │ @ instruction: 0x4621b134 │ │ │ │ @ instruction: 0xf7ff2000 │ │ │ │ stmdavs r4!, {r0, r1, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ @ instruction: 0xf6484629 │ │ │ │ - vshr.s64 q10, q8, #64 │ │ │ │ + vmla.i d20, d16, d0[6] │ │ │ │ ldmfd sp!, {r1} │ │ │ │ @ instruction: 0xf7f84038 │ │ │ │ - svclt 0x0000bc3f │ │ │ │ + svclt 0x0000bc43 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ strmi r4, [fp], -ip, lsl #12 │ │ │ │ strmi fp, [r1], -r2, lsl #1 │ │ │ │ eorcs r4, r0, #5242880 @ 0x500000 │ │ │ │ - andpl pc, ip, r8, asr #12 │ │ │ │ + andpl pc, r4, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - ldc 7, cr15, [r2], #-992 @ 0xfffffc20 │ │ │ │ - blcs 72830 │ │ │ │ + ldc 7, cr15, [r6], #-992 @ 0xfffffc20 │ │ │ │ + blcs 72828 │ │ │ │ vqadd.s8 d29, d0, d19 │ │ │ │ @ instruction: 0xf2c036f0 │ │ │ │ ldmibvs r0!, {r0, r2, r9, sl} │ │ │ │ eorsle r2, pc, r0, lsl #16 │ │ │ │ strtmi r2, [r1], -r1, lsl #4 │ │ │ │ @ instruction: 0xf89cf7ff │ │ │ │ strmi r6, [r3], -r2, lsl #16 │ │ │ │ @ instruction: 0xf648b142 │ │ │ │ - vmvn.i32 d21, #4 @ 0x00000004 │ │ │ │ + vaddl.s8 , d0, d28 │ │ │ │ andlt r0, r2, r2 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - stclt 7, cr15, [lr], {248} @ 0xf8 │ │ │ │ + ldclt 7, cr15, [r2], {248} @ 0xf8 │ │ │ │ andcs r6, sl, ip, lsl r0 │ │ │ │ - stc 7, cr15, [r8, #-992] @ 0xfffffc20 │ │ │ │ + stc 7, cr15, [ip, #-992] @ 0xfffffc20 │ │ │ │ eorcs r6, r0, #2490368 @ 0x260000 │ │ │ │ @ instruction: 0xf6484629 │ │ │ │ - vmla.i d21, d0, d0[1] │ │ │ │ + vmvn.i32 d21, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - cdpne 12, 7, cr14, cr3, cr12, {0} │ │ │ │ + mrcne 12, 3, lr, cr3, cr0, {0} │ │ │ │ vqdmulh.s d2, d0, d9 │ │ │ │ ldm pc, {r1, r2, r3, r4, r6, r8, pc}^ @ │ │ │ │ tstpeq r1, r3, lsl r0 @ p-variant is OBSOLETE │ │ │ │ tsteq pc, r8, lsl r1 @ │ │ │ │ @ instruction: 0x012d0126 │ │ │ │ teqeq fp, r4, lsr r1 │ │ │ │ cmpeq r9, r2, asr #2 │ │ │ │ stmdbvs r3!, {r0, r2, r3, r5} │ │ │ │ - eorpl pc, r8, r8, asr #12 │ │ │ │ + eorpl pc, r0, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ sbcsle r2, r6, r0, lsl #22 │ │ │ │ - andspl pc, ip, #72, 12 @ 0x4800000 │ │ │ │ + andspl pc, r4, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ msrcc R8_fiq, r1 │ │ │ │ - mcr2 7, 2, pc, cr10, cr8, {7} @ │ │ │ │ + mcr2 7, 2, pc, cr14, cr8, {7} @ │ │ │ │ sbccc pc, r4, #64, 4 │ │ │ │ andeq pc, r5, #192, 4 │ │ │ │ biccc pc, r8, r0, asr #4 │ │ │ │ smlabteq r5, r0, r2, pc @ │ │ │ │ rsbcs r4, r4, r3, lsl #12 │ │ │ │ stmdavs r9, {r1, r4, fp, sp, lr} │ │ │ │ - mcrr2 7, 15, pc, r6, cr14 @ │ │ │ │ + mcrr2 7, 15, pc, sl, cr14 @ │ │ │ │ @ instruction: 0xe7af61b0 │ │ │ │ - addpl pc, r4, r8, asr #12 │ │ │ │ + rsbspl pc, ip, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - bl ff4d6840 │ │ │ │ + bl ff5d6838 │ │ │ │ andcs r1, sl, pc, lsr #25 │ │ │ │ - stcl 7, cr15, [r2], {248} @ 0xf8 │ │ │ │ + stcl 7, cr15, [r6], {248} @ 0xf8 │ │ │ │ stmiavs r3!, {r0, r3, r4, r5, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf6482220 │ │ │ │ - vmla.i d21, d16, d0[5] │ │ │ │ + vshr.s64 , q6, #64 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - stmdbvs r6!, {r1, r2, r6, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdbvs r6!, {r1, r3, r6, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ ldrtmi r2, [r9], -r0, lsr #4 │ │ │ │ - rscspl pc, r8, r8, asr #12 │ │ │ │ + rscspl pc, r0, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - bl fef5686c │ │ │ │ + bl ff056864 │ │ │ │ vceq.f32 d2, d0, d3 │ │ │ │ ldm pc, {r2, r3, r4, r8, pc}^ @ │ │ │ │ cdpvc 0, 8, cr15, cr5, cr6, {0} │ │ │ │ @ instruction: 0xf6480277 │ │ │ │ - vmla.i d22, d0, d0[0] │ │ │ │ + vmvn.i32 d22, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0x200aebb0 │ │ │ │ - stc 7, cr15, [r0], #992 @ 0x3e0 │ │ │ │ - blcc b293c │ │ │ │ + @ instruction: 0x200aebb4 │ │ │ │ + stc 7, cr15, [r4], #992 @ 0x3e0 │ │ │ │ + blcc b2934 │ │ │ │ vqdmulh.s d2, d0, d8 │ │ │ │ ldm pc, {r1, r4, r5, r6, r7, pc}^ @ │ │ │ │ ldmdbpl sl!, {r0, r1, ip, sp, lr, pc}^ │ │ │ │ svchi 0x00a40505 │ │ │ │ andeq r0, r5, r9, asr r5 │ │ │ │ eorcs r6, r0, #1622016 @ 0x18c000 │ │ │ │ @ instruction: 0xf6484639 │ │ │ │ - vmvn.i32 q11, #8 @ 0x00000008 │ │ │ │ + vmvn.i32 q11, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - ldmib r4, {r3, r4, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + ldmib r4, {r2, r3, r4, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ tstlt r3, r6, lsl #4 │ │ │ │ ldrtmi r3, [r9], -r9, lsl #6 │ │ │ │ @ instruction: 0xf6489200 │ │ │ │ - vshr.s64 d20, d24, #64 │ │ │ │ + vshr.s64 d20, d16, #64 │ │ │ │ eorcs r0, r0, #2 │ │ │ │ stmdaeq r4, {r0, r2, r8, ip, sp, lr, pc} │ │ │ │ - bl fe2568d4 │ │ │ │ + bl fe3568cc │ │ │ │ ldrtmi r2, [r9], -r0, lsr #4 │ │ │ │ - addvs pc, ip, r8, asr #12 │ │ │ │ + addvs pc, r4, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - bl fe0568e4 │ │ │ │ + bl fe1568dc │ │ │ │ teqlt r6, r6, lsr #20 │ │ │ │ @ instruction: 0x46404631 │ │ │ │ mrc2 7, 7, pc, cr0, cr15, {7} │ │ │ │ mcrcs 8, 0, r6, cr0, cr6, {1} │ │ │ │ @ instruction: 0x4623d1f8 │ │ │ │ ldrtmi r2, [r9], -r0, lsr #4 │ │ │ │ - adcvs pc, r0, r8, asr #12 │ │ │ │ + addsvs pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - bl 1bd6908 │ │ │ │ + bl 1cd6900 │ │ │ │ ldrtmi r6, [r8], -r1, ror #20 │ │ │ │ @ instruction: 0xf8daf000 │ │ │ │ eorcs r6, r0, #667648 @ 0xa3000 │ │ │ │ @ instruction: 0xf6484639 │ │ │ │ - vmla.i d22, d16, d0[0] │ │ │ │ + vshr.s64 d22, d24, #64 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - stmdavs r3!, {r1, r5, r6, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdavs r3!, {r1, r2, r5, r6, r8, r9, fp, sp, lr, pc} │ │ │ │ tstle r1, r9, lsl #22 │ │ │ │ eorcs r4, r0, #59768832 @ 0x3900000 │ │ │ │ - rscvs pc, ip, r8, asr #12 │ │ │ │ + rscvs pc, r4, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - bl 15d6938 │ │ │ │ + bl 16d6930 │ │ │ │ vstmdbne pc!, {s12-s241} │ │ │ │ @ instruction: 0x4631b136 │ │ │ │ @ instruction: 0xf7ff4638 │ │ │ │ ldmdavs r6!, {r0, r1, r2, r3, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ mvnsle r2, r0, lsl #28 │ │ │ │ eorcs r4, r0, #36700160 @ 0x2300000 │ │ │ │ @ instruction: 0xf6484629 │ │ │ │ - vshr.s64 q11, q2, #64 │ │ │ │ + vmla.i d22, d16, d0[3] │ │ │ │ andlt r0, r2, r2 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - bllt fd6964 │ │ │ │ - eorvs pc, ip, r8, asr #12 │ │ │ │ + bllt 10d695c │ │ │ │ + eorvs pc, r4, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - bl ed6970 │ │ │ │ + bl fd6968 │ │ │ │ @ instruction: 0xf648e789 │ │ │ │ - vaddl.s8 q11, d0, d20 │ │ │ │ + vmov.i32 d22, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xe782eb34 │ │ │ │ - andsvs pc, r8, r8, asr #12 │ │ │ │ + @ instruction: 0xe782eb38 │ │ │ │ + andsvs pc, r0, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - bl b5698c │ │ │ │ + bl c56984 │ │ │ │ stcvc 7, cr14, [r0, #-492]! @ 0xfffffe14 │ │ │ │ - andpl pc, r4, #72, 12 @ 0x4800000 │ │ │ │ + rscsmi pc, ip, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ mvnsmi pc, #72, 12 @ 0x4800000 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ stmdacs r0, {r0, r3, r4, r5, r9, sl, lr} │ │ │ │ ldrmi fp, [r3], -r8, lsl #30 │ │ │ │ @ instruction: 0xf6482220 │ │ │ │ - vmla.i d22, d0, d0[4] │ │ │ │ + vmov.i32 q11, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - bfi lr, r8, (invalid: 22:9) │ │ │ │ + bfi lr, ip, (invalid: 22:9) │ │ │ │ stmibvs r3!, {r0, r3, r4, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf6482220 │ │ │ │ - vaddl.s8 , d0, d12 │ │ │ │ - stcne 0, cr0, [pc, #-8]! @ 189e0 <__time64@plt+0x76f8> │ │ │ │ - bl 3569cc │ │ │ │ + vaddl.s8 , d0, d4 │ │ │ │ + stcne 0, cr0, [pc, #-8]! @ 189d8 <__time64@plt+0x76f0> │ │ │ │ + bl 4569c4 │ │ │ │ @ instruction: 0x2e006966 │ │ │ │ @ instruction: 0x4631d0bc │ │ │ │ @ instruction: 0xf7ff4638 │ │ │ │ ldmdavs r6!, {r0, r2, r6, r7, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ mvnsle r2, r0, lsl #28 │ │ │ │ @ instruction: 0x4639e7b4 │ │ │ │ @ instruction: 0xf6482220 │ │ │ │ - vaddl.s8 , d0, d4 │ │ │ │ + vshr.s64 q11, q14, #64 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - stmdbvs r1!, {r1, r3, r4, r5, r6, r7, r9, fp, sp, lr, pc}^ │ │ │ │ + stmdbvs r1!, {r1, r2, r3, r4, r5, r6, r7, r9, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ff4638 │ │ │ │ @ instruction: 0xe7a7feb5 │ │ │ │ - rsbspl pc, r4, r8, asr #12 │ │ │ │ + rsbpl pc, ip, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - b ffbd6a08 │ │ │ │ + b ffcd6a00 │ │ │ │ @ instruction: 0xf648e71a │ │ │ │ - vmov.i32 , #0 @ 0x00000000 │ │ │ │ + vmla.i d21, d0, d0[2] │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - ldr lr, [r3, -r8, ror #21] │ │ │ │ - subspl pc, ip, r8, asr #12 │ │ │ │ + ldr lr, [r3, -ip, ror #21] │ │ │ │ + subspl pc, r4, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - b ff856a24 │ │ │ │ + b ff956a1c │ │ │ │ @ instruction: 0xf648e70c │ │ │ │ - vmla.i d21, d0, d0[6] │ │ │ │ + vmla.i d21, d0, d0[4] │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xe705eada │ │ │ │ - addspl pc, r8, r8, asr #12 │ │ │ │ + @ instruction: 0xe705eade │ │ │ │ + addspl pc, r0, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - b ff4d6a40 │ │ │ │ + b ff5d6a38 │ │ │ │ @ instruction: 0xf648e6fe │ │ │ │ - vaddl.s8 , d16, d20 │ │ │ │ + vshr.s64 d21, d12, #64 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - ldrbt lr, [r7], ip, asr #21 │ │ │ │ - adcspl pc, r4, r8, asr #12 │ │ │ │ + usat lr, #23, r0, asr #21 │ │ │ │ + adcpl pc, ip, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - b ff156a5c │ │ │ │ + b ff256a54 │ │ │ │ @ instruction: 0xf648e6f0 │ │ │ │ - vmla.i d21, d16, d0[0] │ │ │ │ + vshr.s64 d21, d24, #64 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - @ instruction: 0xe6e9eabe │ │ │ │ - sbcspl pc, r0, r8, asr #12 │ │ │ │ + strbt lr, [r9], r2, asr #21 │ │ │ │ + sbcpl pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - b fedd6a78 │ │ │ │ + b feed6a70 │ │ │ │ @ instruction: 0xf648e6e2 │ │ │ │ - vmov.i32 d21, #3072 @ 0x00000c00 │ │ │ │ + vmov.i32 d21, #1024 @ 0x00000400 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d1, d2 │ │ │ │ @ instruction: 0xf7f83154 │ │ │ │ - @ instruction: 0xf648fd0b │ │ │ │ - vsubl.s8 q11, d0, d8 │ │ │ │ + @ instruction: 0xf648fd0f │ │ │ │ + vsubl.s8 q11, d0, d0 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d1, d2 │ │ │ │ @ instruction: 0xf7f821a2 │ │ │ │ - @ instruction: 0xf648fcff │ │ │ │ - vmov.i32 q11, #0 @ 0x00000000 │ │ │ │ + @ instruction: 0xf648fd03 │ │ │ │ + vmlal.s q11, d0, d0[2] │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d1, d2 │ │ │ │ @ instruction: 0xf7f821bc │ │ │ │ - svclt 0x0000fcf3 │ │ │ │ + svclt 0x0000fcf7 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ strmi r4, [ip], -r5, lsl #12 │ │ │ │ - eorvc pc, r4, r8, asr #12 │ │ │ │ + andsvc pc, ip, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ strtmi r2, [r9], -r0, lsr #4 │ │ │ │ - b fe156adc │ │ │ │ + b fe256ad4 │ │ │ │ @ instruction: 0xf648b1cc │ │ │ │ - vmov.i16 , #0 @ 0x0000 │ │ │ │ + vmul.i d23, d0, d0[2] │ │ │ │ @ instruction: 0xf6480802 │ │ │ │ - vqdmlsl.s , d0, d0[1] │ │ │ │ + vbic.i32 d23, #201326592 @ 0x0c000000 │ │ │ │ @ instruction: 0xf6480702 │ │ │ │ - vmvn.i32 d23, #67108864 @ 0x04000000 │ │ │ │ + vsubhn.i16 d23, q0, q14 │ │ │ │ stmiavs r3!, {r1, r9, sl} │ │ │ │ ldmdale r7, {r0, r1, r8, r9, fp, sp} │ │ │ │ @ instruction: 0xf003e8df │ │ │ │ andeq r1, lr, #36, 28 @ 0x240 │ │ │ │ strbmi r6, [r0], -r1, ror #16 │ │ │ │ - b 1b56b0c │ │ │ │ + b 1c56b04 │ │ │ │ stccs 8, cr6, [r0], {36} @ 0x24 │ │ │ │ pop {r0, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ strdcs r4, [sl], -r0 │ │ │ │ - bllt 15d6b1c │ │ │ │ + bllt 16d6b14 │ │ │ │ ldrtmi r6, [r8], -r1, ror #16 │ │ │ │ - b 1856b24 │ │ │ │ + b 1956b1c │ │ │ │ stclne 8, cr6, [r8], #-900 @ 0xfffffc7c │ │ │ │ mrc2 7, 0, pc, cr12, cr15, {7} │ │ │ │ stccs 8, cr6, [r0], {36} @ 0x24 │ │ │ │ pop {r0, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ strdcs r4, [sl], -r0 │ │ │ │ - bllt 11d6b3c │ │ │ │ + bllt 12d6b34 │ │ │ │ ldrtmi r6, [r0], -r2, ror #17 │ │ │ │ @ instruction: 0xf7f86861 │ │ │ │ - ubfx lr, r0, #20, #18 │ │ │ │ - subsvc pc, ip, #72, 12 @ 0x4800000 │ │ │ │ + ubfx lr, r4, #20, #18 │ │ │ │ + subsvc pc, r4, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ bicscs pc, r8, r1, asr #4 │ │ │ │ - stc2 7, cr15, [r4], #992 @ 0x3e0 │ │ │ │ + stc2 7, cr15, [r8], #992 @ 0x3e0 │ │ │ │ vqrshl.s8 d27, d24, d0 │ │ │ │ vshl.s64 , q8, #0 │ │ │ │ @ instruction: 0xf64d0505 │ │ │ │ - vmla.i d20, d16, d0[7] │ │ │ │ + vmla.i d20, d16, d0[5] │ │ │ │ stmibvs r9!, {r1}^ │ │ │ │ ldc2l 7, cr15, [sl, #1020] @ 0x3fc │ │ │ │ @ instruction: 0xf64868ec │ │ │ │ - vmla.f d23, d0, d0[7] │ │ │ │ + vmla.f d23, d0, d0[5] │ │ │ │ @ instruction: 0xf6490102 │ │ │ │ - vaddl.s8 q9, d16, d0 │ │ │ │ + vmvn.i32 q9, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - teqlt r4, ip, lsr #20 │ │ │ │ + teqlt r4, r0, lsr sl │ │ │ │ andcs r4, r0, r1, lsr #12 │ │ │ │ stc2l 7, cr15, [r6, #1020]! @ 0x3fc │ │ │ │ stccs 8, cr6, [r0], {100} @ 0x64 │ │ │ │ @ instruction: 0xf648d1f8 │ │ │ │ - vmla.f d23, d0, d0[7] │ │ │ │ + vmla.f d23, d0, d0[5] │ │ │ │ @ instruction: 0xf6480102 │ │ │ │ - vshr.s64 q10, q8, #64 │ │ │ │ + vmla.i d20, d16, d0[6] │ │ │ │ @ instruction: 0xf7f80002 │ │ │ │ - bvs a9343c │ │ │ │ - subpl pc, r0, sp, asr #12 │ │ │ │ + bvs a93444 │ │ │ │ + eorspl pc, r8, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldc2 7, cr15, [r6, #1020]! @ 0x3fc │ │ │ │ pop {r3, r5, r7, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf7fe4038 │ │ │ │ svclt 0x0000bfd1 │ │ │ │ ldrlt fp, [r0, #-1038]! @ 0xfffffbf2 │ │ │ │ stmdacs r0, {r1, r7, ip, sp, pc} │ │ │ │ stmdavs r2, {r1, r2, r3, r5, ip, lr, pc} │ │ │ │ vcgt.s8 , q0, q9 │ │ │ │ @ instruction: 0xf2c034d8 │ │ │ │ stmdavs r3, {r0, r2, sl}^ │ │ │ │ @ instruction: 0xf6483209 │ │ │ │ - vsra.s64 d20, d12, #64 │ │ │ │ + vsra.s64 d20, d4, #64 │ │ │ │ stmdavs r0!, {r1, r8} │ │ │ │ strls sl, [r1, #-3334] @ 0xfffff2fa │ │ │ │ - b ff2d6bf8 │ │ │ │ - bls 7f030 │ │ │ │ + b ff3d6bf0 │ │ │ │ + bls 7f028 │ │ │ │ @ instruction: 0xf7f86820 │ │ │ │ - stmdavs r0!, {r5, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdavs r0!, {r2, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ andcc lr, r5, #208, 18 @ 0x340000 │ │ │ │ svclt 0x003f4293 │ │ │ │ andcs r1, sl, #22784 @ 0x5900 │ │ │ │ andsvc r6, sl, r1, asr #2 │ │ │ │ vhsub.s8 d29, d0, d10 │ │ │ │ vrsra.s64 , q8, #64 │ │ │ │ andcs r0, r1, #335544320 @ 0x14000000 │ │ │ │ andlt r7, r2, sl, lsl r5 │ │ │ │ ldrhtmi lr, [r0], -sp │ │ │ │ ldrbmi fp, [r0, -r3]! │ │ │ │ @ instruction: 0xf7f8210a │ │ │ │ - udf #3756 @ 0xeac │ │ │ │ - addmi pc, ip, #72, 12 @ 0x4800000 │ │ │ │ + ldrb lr, [r0, r0, lsl #22]! │ │ │ │ + addmi pc, r4, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f8216f │ │ │ │ - svclt 0x0000fc2f │ │ │ │ + svclt 0x0000fc33 │ │ │ │ addsmi r6, r9, #49152 @ 0xc000 │ │ │ │ adcshi pc, r6, r0, asr #6 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ strmi r4, [pc], -r6, lsl #12 │ │ │ │ ldrmi fp, [r4], -pc, lsl #1 │ │ │ │ teqvs r7, r2, lsr r8 │ │ │ │ - blcs 2605d4 │ │ │ │ + blcs 2605cc │ │ │ │ ldm pc, {r3, r4, r6, fp, ip, lr, pc}^ @ │ │ │ │ ldrbpl pc, [sl, -r3] @ │ │ │ │ smlsdvc r5, r7, r5, r0 │ │ │ │ strbeq r5, [r3, #-1903]! @ 0xfffff891 │ │ │ │ andeq pc, sl, #-2147483608 @ 0x80000028 │ │ │ │ - blx fecc38bc │ │ │ │ - bvs 1c556ac │ │ │ │ + blx fecc38b4 │ │ │ │ + bvs 1c556a4 │ │ │ │ stmib sp, {r0, r3, r4, r5, r9, sl, lr}^ │ │ │ │ ldmdbeq r2, {r8, r9, ip, sp}^ │ │ │ │ - bge 23d4c4 │ │ │ │ + bge 23d4bc │ │ │ │ ldrmi r9, [sl], -r2, lsl #4 │ │ │ │ @ instruction: 0xf896f000 │ │ │ │ tstlt r8, r0, lsr fp │ │ │ │ ldrtmi r4, [r9], -r2, lsr #12 │ │ │ │ @ instruction: 0xffd4f7ff │ │ │ │ teqlt sp, r5, ror fp │ │ │ │ strtmi r4, [r2], -r8, lsr #12 │ │ │ │ @ instruction: 0xf7ff4639 │ │ │ │ - blvs feb98c08 │ │ │ │ + blvs feb98c00 │ │ │ │ mvnsle r2, r0, lsl #26 │ │ │ │ stmdane r8!, {r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdaeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x46ba46b3 │ │ │ │ ldrdmi pc, [r0], -fp @ │ │ │ │ @ instruction: 0xf10db31c │ │ │ │ svcge 0x000c0934 │ │ │ │ strcs sl, [r0, #-3595] @ 0xfffff1f5 │ │ │ │ - bge 273278 │ │ │ │ + bge 273270 │ │ │ │ ldrbmi sl, [r1], -sl, lsl #22 │ │ │ │ stmdbvc r1, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ stmib sp, {r9, sl, ip, pc}^ │ │ │ │ stmib sp, {r0, r3, r8, sl, ip, lr}^ │ │ │ │ strls r5, [sp, #-1291] @ 0xfffffaf5 │ │ │ │ @ instruction: 0xf86af000 │ │ │ │ - bcs 3f548 <__time64@plt+0x2e260> │ │ │ │ + bcs 3f540 <__time64@plt+0x2e258> │ │ │ │ stmiavs r3!, {r1, r2, r4, r5, ip, lr, pc} │ │ │ │ - blcs 1b2d88 │ │ │ │ - blls 30ce48 │ │ │ │ - blls 3471b0 │ │ │ │ + blcs 1b2d80 │ │ │ │ + blls 30ce40 │ │ │ │ + blls 3471a8 │ │ │ │ suble r2, fp, r0, lsl #22 │ │ │ │ andhi pc, r8, r4, asr #17 │ │ │ │ stccs 8, cr6, [r0], {36} @ 0x24 │ │ │ │ @ instruction: 0xf8dbd1e0 │ │ │ │ @ instruction: 0xf1bbb030 │ │ │ │ bicsle r0, r3, r0, lsl #30 │ │ │ │ pop {r0, r1, r2, r3, ip, sp, pc} │ │ │ │ @@ -7846,93 +7844,93 @@ │ │ │ │ ldmdbvs r6!, {r0, r1, r8, sp}^ │ │ │ │ ldrb r4, [r6, pc, lsl #12]! │ │ │ │ cmplt r3, sl, lsl #22 │ │ │ │ ldmdavs r9, {r0, r1, r5, r7, fp, sp, lr} │ │ │ │ bicle r2, r6, r6, lsl #18 │ │ │ │ tstcs r1, r8, asr r9 │ │ │ │ @ instruction: 0xff6af7ff │ │ │ │ - bls 292cbc │ │ │ │ + bls 292cb4 │ │ │ │ adcsle r2, lr, r0, lsl #20 │ │ │ │ ldmdavs r1, {r1, r5, r7, fp, sp, lr} │ │ │ │ @ instruction: 0xd1ba2906 │ │ │ │ tstcs r2, r0, asr r9 │ │ │ │ @ instruction: 0xf7ff461a │ │ │ │ sbfx pc, sp, #30, #28 │ │ │ │ tstcs r3, r0, lsl r6 │ │ │ │ @ instruction: 0xf7ff2200 │ │ │ │ sbfx pc, r7, #30, #22 │ │ │ │ smlatbcs r1, r0, r8, r6 │ │ │ │ @ instruction: 0xf7ff9a05 │ │ │ │ sbfx pc, r1, #30, #16 │ │ │ │ @ instruction: 0xf1066972 │ │ │ │ @ instruction: 0xf6480018 │ │ │ │ - vbic.i32 , #8 @ 0x00000008 │ │ │ │ + vbic.i32 , #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ ldr pc, [r4, r7, lsl #30]! │ │ │ │ svclt 0x00004770 │ │ │ │ rsble r2, lr, r0, lsl #16 │ │ │ │ svcmi 0x00f8e92d │ │ │ │ streq pc, [r3], -r1, lsr #3 │ │ │ │ @ instruction: 0xf686fab6 │ │ │ │ - strvc pc, [ip, r8, asr #12] │ │ │ │ + strvc pc, [r4, r8, asr #12] │ │ │ │ streq pc, [r2, -r0, asr #5] │ │ │ │ - stmibvc r4!, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmibvc ip, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdbeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - blvc feb56728 │ │ │ │ - bleq d590c │ │ │ │ + blvc fe956720 │ │ │ │ + bleq d5904 │ │ │ │ @ instruction: 0x469a4690 │ │ │ │ ldmdbeq r6!, {r2, r9, sl, lr}^ │ │ │ │ ldrtmi r6, [r9], -r5, ror #16 │ │ │ │ @ instruction: 0xf7f84628 │ │ │ │ - stmdacs r0, {r1, r2, r5, r6, r7, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r3, r5, r6, r7, fp, sp, lr, pc} │ │ │ │ movwcs fp, #3860 @ 0xf14 │ │ │ │ movweq pc, #4102 @ 0x1006 @ │ │ │ │ @ instruction: 0xf648bb3b │ │ │ │ - vsra.s64 d23, d8, #64 │ │ │ │ + vsra.s64 d23, d0, #64 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - ldm r8, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm ip, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmdavs r4!, {r3, r4, r5, r8, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf8c82301 │ │ │ │ stccs 0, cr3, [r0], {-0} │ │ │ │ pop {r1, r2, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ @ instruction: 0x46498ff8 │ │ │ │ @ instruction: 0xf7f84628 │ │ │ │ - ldmdblt r0!, {r2, r3, r6, r7, fp, sp, lr, pc} │ │ │ │ + ldmdblt r0!, {r4, r6, r7, fp, sp, lr, pc} │ │ │ │ movwcs r6, #6180 @ 0x1824 │ │ │ │ andcc pc, r0, sl, asr #17 │ │ │ │ bicsle r2, r9, r0, lsl #24 │ │ │ │ @ instruction: 0x4659e7f1 │ │ │ │ @ instruction: 0xf7f84628 │ │ │ │ - ldmdblt r8!, {r6, r7, fp, sp, lr, pc}^ │ │ │ │ + ldmdblt r8!, {r2, r6, r7, fp, sp, lr, pc}^ │ │ │ │ movwcs r9, #6666 @ 0x1a0a │ │ │ │ stmdavs r4!, {r0, r1, r4, sp, lr} │ │ │ │ bicle r2, sp, r0, lsl #24 │ │ │ │ stmiavs r3!, {r0, r2, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ bicsle r2, r4, r2, lsl #22 │ │ │ │ andcs r6, r0, #224, 16 @ 0xe00000 │ │ │ │ @ instruction: 0xf7ff2103 │ │ │ │ udf #12257 @ 0x2fe1 │ │ │ │ - @ instruction: 0x71b4f648 │ │ │ │ + @ instruction: 0x71acf648 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f84628 │ │ │ │ - orrlt lr, r0, r8, lsr #17 │ │ │ │ - bicvc pc, r0, r8, asr #12 │ │ │ │ + orrlt lr, r0, ip, lsr #17 │ │ │ │ + @ instruction: 0x71b8f648 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f84628 │ │ │ │ - stmdacs r0, {r5, r7, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r2, r5, r7, fp, sp, lr, pc} │ │ │ │ stmiavs r3!, {r0, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ svclt 0x00012b03 │ │ │ │ - bls 333244 │ │ │ │ + bls 33323c │ │ │ │ andsvs r6, r3, fp, lsl r8 │ │ │ │ - bls 312e24 │ │ │ │ + bls 312e1c │ │ │ │ andsvs r2, r3, r1, lsl #6 │ │ │ │ @ instruction: 0x4770e7d5 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stmib sp, {r0, r1, r3, r7, ip, sp, pc}^ │ │ │ │ - blcs 1d6ec <__time64@plt+0xc404> │ │ │ │ + blcs 1d6e4 <__time64@plt+0xc3fc> │ │ │ │ adchi pc, pc, r0 │ │ │ │ strmi r2, [r5], -r0, lsl #8 │ │ │ │ strtmi r4, [r7], -r6, lsr #12 │ │ │ │ strtmi r4, [r3], r2, lsr #13 │ │ │ │ strtmi r4, [r1], r0, lsr #13 │ │ │ │ strls r4, [r3], #-1569 @ 0xfffff9df │ │ │ │ strls r9, [r4], #-1029 @ 0xfffffbfb │ │ │ │ @@ -7948,125 +7946,125 @@ │ │ │ │ vshl.s64 , q4, #0 │ │ │ │ tstls r9, r5, lsl #10 │ │ │ │ movwls r6, #34859 @ 0x882b │ │ │ │ mrc2 7, 6, pc, cr6, cr14, {7} │ │ │ │ strmi r9, [r2], -r9, lsl #18 │ │ │ │ stmdbls r7, {r0, r8, ip, pc} │ │ │ │ tstls r0, r6, lsl #22 │ │ │ │ - mvnvc pc, r8, asr #12 │ │ │ │ + bicsvc pc, ip, r8, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f89808 │ │ │ │ - blls 193420 │ │ │ │ + blls 193428 │ │ │ │ movweq lr, #14920 @ 0x3a48 │ │ │ │ - b 12fdb60 │ │ │ │ + b 12fdb58 │ │ │ │ movwls r0, #29450 @ 0x730a │ │ │ │ - b 14ffb60 │ │ │ │ + b 14ffb58 │ │ │ │ andle r0, r8, r9, lsl #6 │ │ │ │ - tstpeq r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + mvnsvc pc, r8, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ strbmi r9, [fp], -r4, lsl #20 │ │ │ │ @ instruction: 0xf7f86828 │ │ │ │ - blls 1d33f8 │ │ │ │ + blls 1d3400 │ │ │ │ vrhadd.s8 , , │ │ │ │ - vaddw.s8 q8, q0, d20 │ │ │ │ - blls 15937c │ │ │ │ + vorr.i32 d16, #12 @ 0x0000000c │ │ │ │ + blls 159374 │ │ │ │ stmdavs r8!, {r1, r6, r9, sl, lr} │ │ │ │ - ldmdb r8, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmdb ip, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ movweq lr, #43595 @ 0xaa4b │ │ │ │ cmple lr, r0, lsl #22 │ │ │ │ vand d27, d9, d28 │ │ │ │ - vmla.f d16, d0, d0[5] │ │ │ │ + vorr.i32 q8, #12 @ 0x0000000c │ │ │ │ stmdavs r8!, {r1, r8} │ │ │ │ @ instruction: 0xf7f84622 │ │ │ │ - blls 1133c8 │ │ │ │ + blls 1133d0 │ │ │ │ teqle r7, r0, lsl #22 │ │ │ │ - bllt 19c7c1c │ │ │ │ + bllt 19c7c14 │ │ │ │ andcs r6, sl, r9, lsr #16 │ │ │ │ pop {r0, r1, r3, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f84ff0 │ │ │ │ - bls 10752c │ │ │ │ + bls 107534 │ │ │ │ andls r3, r3, #268435456 @ 0x10000000 │ │ │ │ strcc lr, [r1], #-1961 @ 0xfffff857 │ │ │ │ @ instruction: 0xf10be7a7 │ │ │ │ str r0, [r4, r1, lsl #22]! │ │ │ │ - beq 953ec │ │ │ │ - bls 192e4c │ │ │ │ + beq 953e4 │ │ │ │ + bls 192e44 │ │ │ │ andls r3, r5, #268435456 @ 0x10000000 │ │ │ │ @ instruction: 0xf108e79d │ │ │ │ ldr r0, [sl, r1, lsl #16] │ │ │ │ stmdbeq r1, {r0, r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x3601e797 │ │ │ │ - bls 152e34 │ │ │ │ + bls 152e2c │ │ │ │ andls r3, r4, #268435456 @ 0x10000000 │ │ │ │ vaba.s8 d30, d25, d1 │ │ │ │ - vsra.s64 d16, d4, #64 │ │ │ │ + vaddw.s8 q8, q8, d12 │ │ │ │ stmdavs r8!, {r1, r8} │ │ │ │ @ instruction: 0xf7f8463a │ │ │ │ - mcrcs 8, 0, lr, cr0, cr12, {6} │ │ │ │ + cdpcs 8, 0, cr14, cr0, cr0, {7} │ │ │ │ stmdavs r8!, {r1, r4, r6, r7, ip, lr, pc} │ │ │ │ vmin.s8 d20, d9, d18 │ │ │ │ - vaddw.s8 q8, q8, d28 │ │ │ │ + vaddw.s8 q8, q8, d20 │ │ │ │ @ instruction: 0xf7f80102 │ │ │ │ - @ instruction: 0xe7c9e8d2 │ │ │ │ - cmnpeq ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + @ instruction: 0xe7c9e8d6 │ │ │ │ + cmnpeq r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrmi r6, [sl], -r8, lsr #16 │ │ │ │ - stmia r8, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia ip, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ adcsle r2, lr, r0, lsl #30 │ │ │ │ stmdavs r8!, {r0, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ @ instruction: 0x4652465b │ │ │ │ - cmppeq r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpeq ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldm ip!, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmia r0, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ vabd.s8 d30, d16, d22 │ │ │ │ vshl.s64 , q4, #0 │ │ │ │ movwls r0, #13573 @ 0x3505 │ │ │ │ @ instruction: 0xf7fe682c │ │ │ │ - blls 11895c │ │ │ │ + blls 118954 │ │ │ │ stmdbls r7, {r1, r9, sl, lr} │ │ │ │ movwls r4, #5664 @ 0x1620 │ │ │ │ @ instruction: 0xf6489100 │ │ │ │ - vmla.f d23, d16, d0[5] │ │ │ │ - blls 199464 │ │ │ │ - stmia r6!, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + vsra.s64 , q6, #64 │ │ │ │ + blls 19945c │ │ │ │ + stmia sl!, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf648e79e │ │ │ │ - vmlal.s , d16, d0[3] │ │ │ │ + vmlal.s , d16, d0[1] │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ bicscs r0, r5, r2 │ │ │ │ - blx a57058 │ │ │ │ + blx b57050 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ vmax.s8 d20, d25, d8 │ │ │ │ - vmla.f d16, d16, d0[2] │ │ │ │ + vmla.f d16, d16, d0[0] │ │ │ │ strmi r0, [r5], -r2, lsl #2 │ │ │ │ vmin.s8 d20, d0, d7 │ │ │ │ @ instruction: 0xf2c036f0 │ │ │ │ @ instruction: 0xf7f70605 │ │ │ │ - stmdblt r8!, {r1, r3, r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ - bvs 1cf3184 │ │ │ │ + stmdblt r8!, {r1, r2, r3, r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + bvs 1cf317c │ │ │ │ mulle r1, sl, r2 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ ldmdblt r4, {r2, r4, r5, r6, r7, r8, fp, sp, lr} │ │ │ │ stmdavs r4!, {r0, r2, r5, sp, lr, pc} │ │ │ │ stmdavs r0!, {r2, r3, r4, r8, r9, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7f74629 │ │ │ │ - stmdacs r0, {r1, r3, r4, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r3, r4, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ stmiavs r3!, {r0, r1, r2, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ rscle r4, pc, r3, asr #10 │ │ │ │ - bicseq pc, r8, r9, asr #4 │ │ │ │ + bicseq pc, r0, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f74628 │ │ │ │ - stmdacs r0, {r1, r2, r3, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r4, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ ldrtmi sp, [r8], -r6, ror #1 │ │ │ │ vmax.s8 d20, d9, d26 │ │ │ │ - vmla.f d16, d16, d0[5] │ │ │ │ + vsra.s64 q8, q6, #64 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ @ instruction: 0xf104fd85 │ │ │ │ vhadd.s8 d16, d9, d12 │ │ │ │ - vaddw.s8 , q0, d4 │ │ │ │ + vsra.s64 q8, q14, #64 │ │ │ │ pop {r1, r8} │ │ │ │ @ instruction: 0xf7ff41f0 │ │ │ │ andscs fp, r8, fp, ror sp │ │ │ │ mcr2 7, 1, pc, cr12, cr14, {7} @ │ │ │ │ @ instruction: 0xf1004603 │ │ │ │ ldmibvs r1!, {r2, r3, r9}^ │ │ │ │ @ instruction: 0xf8c06045 │ │ │ │ @@ -8076,133 +8074,133 @@ │ │ │ │ andcs r6, r0, #-1073741764 @ 0xc000003c │ │ │ │ pop {r1, r3, r4, r6, r8, sp, lr} │ │ │ │ svclt 0x000081f0 │ │ │ │ stmdbmi r1, {r1, r3, r9, sl, lr} │ │ │ │ svclt 0x00a8f7ff │ │ │ │ andeq r0, r5, r8, lsr #3 │ │ │ │ stmdavs r3, {r3, r8, sl, ip, sp, pc} │ │ │ │ - blcc 260d9c │ │ │ │ + blcc 260d94 │ │ │ │ svclt 0x00882b01 │ │ │ │ stmdale sl, {r0, r9, fp, sp} │ │ │ │ svcne 0x001a680b │ │ │ │ - blcs 67d68 │ │ │ │ - bcs 88f68 │ │ │ │ - blvs 110f188 │ │ │ │ + blcs 67d60 │ │ │ │ + bcs 88f60 │ │ │ │ + blvs 110f180 │ │ │ │ movtvs r6, #5003 @ 0x138b │ │ │ │ vadd.f32 d27, d9, d8 │ │ │ │ - vmov.i32 d17, #3072 @ 0x00000c00 │ │ │ │ + vmov.i32 d17, #1024 @ 0x00000400 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7f821e6 │ │ │ │ - vmla.i8 d31, d25, d31 │ │ │ │ - vmov.i32 d17, #3072 @ 0x00000c00 │ │ │ │ + vmul.i8 d31, d25, d19 │ │ │ │ + vmov.i32 d17, #1024 @ 0x00000400 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7f821e7 │ │ │ │ - svclt 0x0000f9a3 │ │ │ │ + svclt 0x0000f9a7 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ ldmdavs r7, {r4, r7, r9, sl, lr} │ │ │ │ strmi fp, [r5], -r3, lsl #1 │ │ │ │ movwls r4, #1550 @ 0x60e │ │ │ │ ldmdavs pc!, {r0, r1, r2, r8, ip, sp, pc}^ @ │ │ │ │ - bleq 195834 │ │ │ │ + bleq 19582c │ │ │ │ @ instruction: 0xf1a61f32 │ │ │ │ - blx feed9dc8 │ │ │ │ - blcs 97fd4 │ │ │ │ - bcs 88fcc │ │ │ │ - blne 1713aec │ │ │ │ + blx feed9dc0 │ │ │ │ + blcs 97fcc │ │ │ │ + bcs 88fc4 │ │ │ │ + blne 1713ae4 │ │ │ │ @ instruction: 0xf04fbf94 │ │ │ │ @ instruction: 0xf04f0a01 │ │ │ │ vpmax.s8 d0, d0, d0 │ │ │ │ vhadd.s8 q12, q8, q11 │ │ │ │ @ instruction: 0xf2c039f0 │ │ │ │ @ instruction: 0xf8d90905 │ │ │ │ stmdblt ip, {r2, r3, lr}^ │ │ │ │ - blcs 29152c │ │ │ │ + blcs 291524 │ │ │ │ cdpcs 0, 0, cr13, cr5, cr7, {2} │ │ │ │ addhi pc, lr, r0, asr #32 │ │ │ │ - blcs 33368 <__time64@plt+0x22080> │ │ │ │ + blcs 33360 <__time64@plt+0x22078> │ │ │ │ ldrmi sp, [ip], -r9, asr #32 │ │ │ │ strtmi r6, [r8], -r1, ror #18 │ │ │ │ - svc 0x0000f7f7 │ │ │ │ + svc 0x0004f7f7 │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ - blcs 17327c │ │ │ │ + blcs 173274 │ │ │ │ ldrbmi sp, [r2], -sp, ror #3 │ │ │ │ mvnle r4, sl, asr r5 │ │ │ │ cmnle fp, r9, lsl #22 │ │ │ │ andcs r6, r0, #929792 @ 0xe3000 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - bvs fe679504 │ │ │ │ + bvs fe6794fc │ │ │ │ svclt 0x000842b9 │ │ │ │ ldmdavs fp, {r1, r3, r4, r9, sl, lr}^ │ │ │ │ mvnsle r2, r0, lsl #22 │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ @ instruction: 0x461480b5 │ │ │ │ - blcs 33dac <__time64@plt+0x22ac4> │ │ │ │ - bvs fe70d314 │ │ │ │ + blcs 33da4 <__time64@plt+0x22abc> │ │ │ │ + bvs fe70d30c │ │ │ │ cmple r7, pc, lsl r2 │ │ │ │ @ instruction: 0xf1046ae3 │ │ │ │ cmnvs r5, r8, lsl r9 │ │ │ │ ldm r8, {r9, fp, ip, pc} │ │ │ │ eorvs r0, r6, r3 │ │ │ │ andeq lr, r3, r9, lsl #17 │ │ │ │ - bls 331ac8 │ │ │ │ + bls 331ac0 │ │ │ │ strcs lr, [r9, -r4, asr #19] │ │ │ │ - bvs fe6c5694 │ │ │ │ + bvs fe6c568c │ │ │ │ addsvs r4, sl, #-402653184 @ 0xe8000000 │ │ │ │ @ instruction: 0x63239b0d │ │ │ │ @ instruction: 0x4621b11b │ │ │ │ @ instruction: 0xf7ff4618 │ │ │ │ strtmi pc, [r0], -r9, ror #30 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ - bvs ff8bd224 │ │ │ │ + bvs ff8bd21c │ │ │ │ @ instruction: 0xf1a26812 │ │ │ │ - blx fec99a80 │ │ │ │ + blx fec99a78 │ │ │ │ ldmdbeq r2, {r1, r7, r9, ip, sp, lr, pc}^ │ │ │ │ stcne 7, cr14, [r3, #-768]! @ 0xfffffd00 │ │ │ │ @ instruction: 0x2010f8d9 │ │ │ │ andcs r2, r1, r0, asr #2 │ │ │ │ andcc r9, r1, #67108864 @ 0x4000000 │ │ │ │ andscs pc, r0, r9, asr #17 │ │ │ │ stc2l 7, cr15, [lr, #-1016] @ 0xfffffc08 │ │ │ │ @ instruction: 0xf8d99b01 │ │ │ │ @ instruction: 0x46042010 │ │ │ │ addvs r4, r2, r2, asr r2 │ │ │ │ - bvs ff8f12f8 │ │ │ │ + bvs ff8f12f0 │ │ │ │ bicle r2, r2, r0, lsl #22 │ │ │ │ tstpeq r8, #4, 2 @ p-variant is OBSOLETE │ │ │ │ eorvs r6, r6, r5, ror #2 │ │ │ │ muleq r3, r8, r8 │ │ │ │ andeq lr, r3, r3, lsl #17 │ │ │ │ eorvs r9, r3, #0, 22 │ │ │ │ stmib r4, {r2, r3, r8, r9, fp, ip, pc}^ │ │ │ │ strb r3, [r9, r9, lsl #14] │ │ │ │ - bicscc pc, r0, #76, 12 @ 0x4c00000 │ │ │ │ + biccc pc, r8, #76, 12 @ 0x4c00000 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - sbcpl pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ + sbcpl pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ svclt 0x00182e05 │ │ │ │ @ instruction: 0x4640461a │ │ │ │ @ instruction: 0xf1046963 │ │ │ │ vmul.i8 d16, d9, d8 │ │ │ │ - vbic.i32 d17, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d17, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ strbmi pc, [r8], -r5, lsl #25 @ │ │ │ │ - cmppne ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppne r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldc2l 7, cr15, [lr], #-1020 @ 0xfffffc04 │ │ │ │ ldr r6, [ip, r3, ror #21] │ │ │ │ - blcs 33984 <__time64@plt+0x2269c> │ │ │ │ - bvs fe90d53c │ │ │ │ + blcs 3397c <__time64@plt+0x22694> │ │ │ │ + bvs fe90d534 │ │ │ │ @ instruction: 0xd08d42bb │ │ │ │ @ instruction: 0x3010f8d9 │ │ │ │ andcs r2, r1, r0, asr #2 │ │ │ │ - beq 105571c │ │ │ │ + beq 1055714 │ │ │ │ @ instruction: 0xf8c93301 │ │ │ │ @ instruction: 0xf7fe3010 │ │ │ │ strtmi pc, [r3], -r7, lsl #26 │ │ │ │ @ instruction: 0xf8d34602 │ │ │ │ tstcc r0, #0 │ │ │ │ stcgt 8, cr15, [ip], {83} @ 0x53 │ │ │ │ @ instruction: 0xf8533210 │ │ │ │ @@ -8227,75 +8225,75 @@ │ │ │ │ subvs r6, r3, r3, ror #21 │ │ │ │ rscvs r4, r0, #36700160 @ 0x2300000 │ │ │ │ strmi r6, [r4], -r4, asr #5 │ │ │ │ @ instruction: 0xf109e751 │ │ │ │ ldrb r0, [r7, -ip, lsl #6]! │ │ │ │ @ instruction: 0x3010f8d9 │ │ │ │ vabd.s8 q15, , │ │ │ │ - vsubl.s8 , d0, d28 │ │ │ │ + vsubl.s8 , d0, d20 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7f821fb │ │ │ │ - svclt 0x0000f893 │ │ │ │ + svclt 0x0000f897 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ stmdbeq r5, {r0, r5, r7, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf989fab9 │ │ │ │ - b 13e0ce0 │ │ │ │ - blcs 25f91c │ │ │ │ + b 13e0cd8 │ │ │ │ + blcs 25f914 │ │ │ │ vadd.i8 , q0, │ │ │ │ sbcsmi r3, pc, r9, lsl r7 @ │ │ │ │ smuadeq r1, r7, r0 │ │ │ │ vqadd.s8 d29, d0, d31 │ │ │ │ @ instruction: 0xf2c038f0 │ │ │ │ strmi r0, [lr], -r5, lsl #16 │ │ │ │ @ instruction: 0xf8d84605 │ │ │ │ ldmdblt ip!, {r2, r3, lr} │ │ │ │ - blcs 2914a4 │ │ │ │ + blcs 29149c │ │ │ │ mcrcs 0, 0, sp, cr5, cr3, {0} │ │ │ │ stmdavs r3!, {r1, r2, r3, r8, ip, lr, pc}^ │ │ │ │ @ instruction: 0x461cb1bb │ │ │ │ strtmi r6, [r8], -r1, ror #18 │ │ │ │ - ldcl 7, cr15, [ip, #988]! @ 0x3dc │ │ │ │ + mcr 7, 0, pc, cr0, cr7, {7} @ │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ - blcs 173484 │ │ │ │ + blcs 17347c │ │ │ │ ldrtmi sp, [fp], -pc, ror #3 │ │ │ │ mvnsle r4, fp, asr #10 │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ - bvs ff8fa3e8 │ │ │ │ + bvs ff8fa3e0 │ │ │ │ @ instruction: 0xf1a3681b │ │ │ │ - blx fecda024 │ │ │ │ + blx fecda01c │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ stcne 7, cr14, [r7, #-968]! @ 0xfffffc38 │ │ │ │ @ instruction: 0x3010f8d8 │ │ │ │ andcs r2, r1, r0, asr #2 │ │ │ │ @ instruction: 0xf8c83301 │ │ │ │ @ instruction: 0xf7fe3010 │ │ │ │ @ instruction: 0xf8d8fc7d │ │ │ │ @ instruction: 0x46043010 │ │ │ │ cmpvs r5, r6 │ │ │ │ addvs r4, r3, fp, asr r2 │ │ │ │ @ instruction: 0x46206038 │ │ │ │ mvnshi lr, #12386304 @ 0xbd0000 │ │ │ │ streq pc, [ip, -r8, lsl #2] │ │ │ │ vabd.s8 q15, , q12 │ │ │ │ - vmvn.i32 , #2048 @ 0x00000800 │ │ │ │ + vmvn.i32 , #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vst4.8 {d16-d19}, [pc], r2 │ │ │ │ @ instruction: 0xf7f87154 │ │ │ │ - svclt 0x0000f835 │ │ │ │ + svclt 0x0000f839 │ │ │ │ vqrshl.s8 d27, d0, d9 │ │ │ │ - vaddw.s8 , q8, d8 │ │ │ │ + vaddw.s8 , q8, d0 │ │ │ │ strmi r0, [r4], -r2, lsl #2 │ │ │ │ - ldc 7, cr15, [ip, #988]! @ 0x3dc │ │ │ │ + stcl 7, cr15, [r0, #988] @ 0x3dc │ │ │ │ @ instruction: 0x4620b170 │ │ │ │ - orrsne pc, r0, r9, asr #4 │ │ │ │ + orrne pc, r8, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldc 7, cr15, [r4, #988]! @ 0x3dc │ │ │ │ + ldc 7, cr15, [r8, #988]! @ 0x3dc │ │ │ │ @ instruction: 0xf1a24a04 │ │ │ │ stmdacs r0, {r6, r8, r9} │ │ │ │ ldrmi fp, [r0], -ip, lsl #30 │ │ │ │ ldclt 6, cr4, [r0, #-96] @ 0xffffffa0 │ │ │ │ ldclt 8, cr4, [r0, #-0] │ │ │ │ andeq r0, r5, r8, ror #3 │ │ │ │ @ instruction: 0x4604b510 │ │ │ │ @@ -8357,127 +8355,127 @@ │ │ │ │ cmnvs r6, r0, lsr #32 │ │ │ │ eormi pc, r0, ip, asr #17 │ │ │ │ pop {r0, r1, r5, sp, lr} │ │ │ │ svclt 0x000081f0 │ │ │ │ teqlt r8, r3, lsl #12 │ │ │ │ ldrmi r2, [r8], -r0, lsl #4 │ │ │ │ andvs r6, r2, fp, lsl r8 │ │ │ │ - blcs 2ada0 <__time64@plt+0x19ab8> │ │ │ │ + blcs 2ad98 <__time64@plt+0x19ab0> │ │ │ │ @ instruction: 0x4770d1f9 │ │ │ │ svclt 0x00004770 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stmdavs r4, {r1, r2, r9, sl, lr} │ │ │ │ smlatbls ip, r1, r0, fp │ │ │ │ @ instruction: 0xf0002900 │ │ │ │ @ instruction: 0xf04f8698 │ │ │ │ @ instruction: 0xf6480e00 │ │ │ │ - vsubw.s8 , q8, d20 │ │ │ │ + vrsra.s64 d23, d12, #64 │ │ │ │ vcgt.s8 d16, d9, d2 │ │ │ │ - vbic.i32 d18, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d18, #4 @ 0x00000004 │ │ │ │ tstls r5, #-2147483648 @ 0x80000000 │ │ │ │ vqshl.s8 d25, d15, d9 │ │ │ │ - vsubw.s8 , q8, d8 │ │ │ │ + vsubw.s8 , q8, d0 │ │ │ │ @ instruction: 0xf8cd0302 │ │ │ │ movwls lr, #24656 @ 0x6050 │ │ │ │ ands r9, r2, sl, lsl r1 │ │ │ │ - blcs 40230 <__time64@plt+0x2ef48> │ │ │ │ + blcs 40228 <__time64@plt+0x2ef40> │ │ │ │ sbcshi pc, r8, r0, asr #32 │ │ │ │ ldmdavs fp, {r0, r1, r4, r5, r6, r8, fp, sp, lr} │ │ │ │ - blcs 681f4 │ │ │ │ + blcs 681ec │ │ │ │ movwcs fp, #8068 @ 0x1f84 │ │ │ │ vcge.s8 d25, d0, d4 │ │ │ │ - blls 339964 │ │ │ │ + blls 33995c │ │ │ │ movwls r6, #51227 @ 0xc81b │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - blls 3399a8 │ │ │ │ + blls 3399a0 │ │ │ │ ldmdavs ip, {r0, r2, r4, r8, fp, ip, pc}^ │ │ │ │ @ instruction: 0xf7f74620 │ │ │ │ - stmdacs r0, {r1, r2, r3, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r4, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ ldmdbls sl, {r2, r5, r6, r7, ip, lr, pc} │ │ │ │ @ instruction: 0xf7f74620 │ │ │ │ - stmdacs r0, {r3, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ - blls 34ddcc │ │ │ │ + stmdacs r0, {r2, r3, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + blls 34ddc4 │ │ │ │ stccs 8, cr6, [r1], {156} @ 0x9c │ │ │ │ ldmvs sp, {r0, r1, r2, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ - cmppcs r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpcs ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f74628 │ │ │ │ - ldrdls lr, [r7], -sl │ │ │ │ + ldrdls lr, [r7], -lr @ │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ ldmdavs r3!, {r1, r5, r6, r7, pc} │ │ │ │ @ instruction: 0xf0402b05 │ │ │ │ andscs r8, r0, r6, lsr #9 │ │ │ │ - blx fe157646 │ │ │ │ - bls 1eae5c │ │ │ │ + blx fe15763e │ │ │ │ + bls 1eae54 │ │ │ │ vhadd.s8 d22, d9, d2 │ │ │ │ - vmvn.i32 q9, #3072 @ 0x00000c00 │ │ │ │ + vmvn.i32 q9, #1024 @ 0x00000400 │ │ │ │ addvs r0, r4, r2, lsl #4 │ │ │ │ vhadd.s8 d25, d9, d3 │ │ │ │ - vmla.i d18, d0, d0[1] │ │ │ │ + vmvn.i32 d18, #12 @ 0x0000000c │ │ │ │ subsvs r0, sl, r2 │ │ │ │ vqsub.s8 d25, d10, d14 │ │ │ │ - vmlal.s q10, d16, d0[1] │ │ │ │ + vrshr.s64 d20, d28, #64 │ │ │ │ sbcsvs r0, sl, r2, lsl #4 │ │ │ │ @ instruction: 0xf7fe920e │ │ │ │ stmiavs r3, {r0, r1, r2, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ tstls r3, #5242880 @ 0x500000 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ vmin.s8 d24, d16, d6 │ │ │ │ @ instruction: 0xf2c03af0 │ │ │ │ vpmax.s8 d16, d9, d5 │ │ │ │ - vaddl.s8 q9, d16, d0 │ │ │ │ + vmvn.i32 q9, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fe0002 │ │ │ │ stmiavs r3, {r0, r1, r2, r4, r5, r7, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ tstls r2, #5242880 @ 0x500000 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ smlatbcs r5, lr, r6, r8 │ │ │ │ - addcs pc, ip, r9, asr #4 │ │ │ │ + addcs pc, r4, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ mrc2 7, 3, pc, cr8, cr15, {7} │ │ │ │ strmi r6, [r5], -r3, asr #17 │ │ │ │ - blcs 3e328 <__time64@plt+0x2d040> │ │ │ │ + blcs 3e320 <__time64@plt+0x2d038> │ │ │ │ strhi pc, [pc], r0 │ │ │ │ - addscs pc, r8, r9, asr #4 │ │ │ │ + addscs pc, r0, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xff9ef7fe │ │ │ │ strmi r6, [r5], -r3, asr #17 │ │ │ │ - blcs 3e330 <__time64@plt+0x2d048> │ │ │ │ + blcs 3e328 <__time64@plt+0x2d040> │ │ │ │ ldrbhi pc, [sp], r0 @ │ │ │ │ - adccs pc, r4, r9, asr #4 │ │ │ │ + addscs pc, ip, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xff92f7fe │ │ │ │ strmi r6, [r5], -r3, asr #17 │ │ │ │ - blcs 3e360 <__time64@plt+0x2d078> │ │ │ │ + blcs 3e358 <__time64@plt+0x2d070> │ │ │ │ ldrthi pc, [pc], r0 @ │ │ │ │ - adcscs pc, r0, r9, asr #4 │ │ │ │ + adccs pc, r8, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xff86f7fe │ │ │ │ strmi r6, [r5], -r3, asr #17 │ │ │ │ - blcs 3e368 <__time64@plt+0x2d080> │ │ │ │ + blcs 3e360 <__time64@plt+0x2d078> │ │ │ │ strthi pc, [r1], r0 │ │ │ │ - sbccs pc, r0, r9, asr #4 │ │ │ │ + adcscs pc, r8, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xff7af7fe │ │ │ │ strmi r6, [r5], -r3, asr #17 │ │ │ │ - blcs 3e33c <__time64@plt+0x2d054> │ │ │ │ + blcs 3e334 <__time64@plt+0x2d04c> │ │ │ │ strhi pc, [r3], r0 │ │ │ │ smlsdcs r0, fp, r8, r4 │ │ │ │ - tstpcc r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + mvnscs pc, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf2494e59 │ │ │ │ - vmul.f d17, d16, d0[0] │ │ │ │ + @ instruction: 0xf2c019b8 │ │ │ │ ldrtmi r0, [sp], -r2, lsl #18 │ │ │ │ stmeq r0, {r5, r7, r8, ip, sp, lr, pc} │ │ │ │ vmax.s8 d20, d25, d11 │ │ │ │ - vmlal.s , d16, d0[2] │ │ │ │ + vmlal.s , d16, d0[0] │ │ │ │ vhsub.s8 d16, d9, d2 │ │ │ │ - vrsra.s64 , q0, #64 │ │ │ │ + vqdmlal.s , d16, d0[2] │ │ │ │ tstls pc, r2, lsl #6 │ │ │ │ vcgt.s8 d25, d9, d4 │ │ │ │ - vsubw.s8 , q8, d16 │ │ │ │ + vrsra.s64 d17, d8, #64 │ │ │ │ strls r0, [r5], #-770 @ 0xfffffcfe │ │ │ │ movwcs lr, #39373 @ 0x99cd │ │ │ │ @ instruction: 0xf8da1e7b │ │ │ │ andscs r4, r8, r4, lsr #32 │ │ │ │ ldmdale r5!, {r0, r4, r8, r9, fp, sp}^ │ │ │ │ @ instruction: 0xf013e8df │ │ │ │ umullseq r0, r4, r4, r0 │ │ │ │ @@ -8486,172 +8484,172 @@ │ │ │ │ rsbseq r0, r4, r4, ror r0 │ │ │ │ streq r0, [r3], #-116 @ 0xffffff8c │ │ │ │ rsbseq r0, r4, r4, ror r0 │ │ │ │ rsbseq r0, r4, r4, ror r0 │ │ │ │ rsbseq r0, r4, r4, ror r0 │ │ │ │ addseq r0, r4, r4, ror r0 │ │ │ │ vmax.s8 d20, d9, d18 │ │ │ │ - vmla.f d17, d16, d0[6] │ │ │ │ + vmla.f d17, d16, d0[4] │ │ │ │ vrhadd.s8 d16, d0, d2 │ │ │ │ vmov.i32 d23, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fe0005 │ │ │ │ ldr pc, [fp, -r1, ror #30] │ │ │ │ vqdmulh.s d25, d9, d12 │ │ │ │ - vaddw.s8 q9, q0, d0 │ │ │ │ + vsra.s64 , q12, #64 │ │ │ │ vrhadd.s8 d16, d0, d2 │ │ │ │ vmov.i32 d23, #8 @ 0x00000008 │ │ │ │ ldmdavs sl, {r0, r2}^ │ │ │ │ @ instruction: 0xff54f7fe │ │ │ │ tstls r4, #67108864 @ 0x4000000 │ │ │ │ ldmdavs fp, {r2, r3, r8, r9, fp, ip, pc} │ │ │ │ - blcs 3e400 <__time64@plt+0x2d118> │ │ │ │ + blcs 3e3f8 <__time64@plt+0x2d110> │ │ │ │ svcge 0x0017f47f │ │ │ │ ldrsb pc, [r0], #-141 @ 0xffffff73 @ │ │ │ │ ldcls 6, cr4, [pc], {48} @ 0x30 │ │ │ │ movweq pc, #4238 @ 0x108e @ │ │ │ │ svclt 0x00142c06 │ │ │ │ @ instruction: 0xf0032300 │ │ │ │ @ instruction: 0xb1230301 │ │ │ │ ldmdavs sl, {r0, r1, r4, r5, r6, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf0002a02 │ │ │ │ ldmdavs r4!, {r0, r1, r3, r4, r6, r7, r8, r9, pc} │ │ │ │ andle r2, lr, r7, lsl #24 │ │ │ │ pop {r0, r5, ip, sp, pc} │ │ │ │ qsub8mi r8, sl, r0 │ │ │ │ - cmppmi ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppmi r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ andsvc pc, r8, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0xff2af7fe │ │ │ │ ldmdbvs r3!, {r0, r2, r3, r5, r6, r7, r9, sl, sp, lr, pc}^ │ │ │ │ - bcs 1b3888 │ │ │ │ + bcs 1b3880 │ │ │ │ ldmdbvs fp, {r2, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ - bcs b3890 │ │ │ │ + bcs b3888 │ │ │ │ ldcvc 1, cr13, [fp, #-928] @ 0xfffffc60 │ │ │ │ rscle r2, r5, r0, lsl #22 │ │ │ │ ldrbcc pc, [r0, #576]! @ 0x240 @ │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ cmpcs r0, r1 │ │ │ │ stmdbvs fp!, {r1, r2, r4, r5, r7, r8, fp, sp, lr} │ │ │ │ @ instruction: 0x612b4403 │ │ │ │ - blx 1bd7840 │ │ │ │ - bmi 473cf8 │ │ │ │ + blx 1bd7838 │ │ │ │ + bmi 473cf0 │ │ │ │ andvs r4, r4, fp, asr r2 │ │ │ │ stmib r0, {r0, r1, r7, sp, lr}^ │ │ │ │ ldrb r2, [r1, r5, lsl #12] │ │ │ │ - blx 1f57854 │ │ │ │ + blx 1f5784c │ │ │ │ andvs r9, r5, sl, lsl #22 │ │ │ │ andcs r4, r0, #5242880 @ 0x500000 │ │ │ │ stmib r0, {r0, r1, r6, sp, lr}^ │ │ │ │ vst3.8 {d24-d26}, [pc], r2 │ │ │ │ stmib r0, {r0, r1, r2, r4, r7, r8, r9, sp, lr}^ │ │ │ │ andscs r3, r0, r4, lsl #4 │ │ │ │ svcmi 0x0004f856 │ │ │ │ - blx 1b57874 │ │ │ │ + blx 1b5786c │ │ │ │ stmib r0, {r0, r1, r8, r9, fp, ip, pc}^ │ │ │ │ strcc r3, [r1, -r0, lsl #22] │ │ │ │ sbcvs r2, r4, r1, lsl #6 │ │ │ │ addvs r6, r3, r8, ror #2 │ │ │ │ svclt 0x0000e768 │ │ │ │ andeq r0, r5, r8, lsr #4 │ │ │ │ - andeq lr, r2, ip, ror r8 │ │ │ │ - blx 1757894 │ │ │ │ + andeq lr, r2, r4, ror r8 │ │ │ │ + blx 175788c │ │ │ │ addvs r4, r3, r5, lsl #23 │ │ │ │ - blls 2654ec │ │ │ │ + blls 2654e4 │ │ │ │ @ instruction: 0xf04f6005 │ │ │ │ subvs r0, r3, r0, lsl #10 │ │ │ │ @ instruction: 0x43abf240 │ │ │ │ stmib r0, {r2, r6, r7, sp, lr}^ │ │ │ │ @ instruction: 0xf0403504 │ │ │ │ pkhtbmi r8, r3, ip, asr #6 │ │ │ │ stcls 0, cr2, [r5], {16} │ │ │ │ - blx 12578bc │ │ │ │ - bls eb2d8 │ │ │ │ + blx 12578b4 │ │ │ │ + bls eb2d0 │ │ │ │ strcs r9, [r1, -lr, lsl #18] │ │ │ │ strpl lr, [r0, #-2509] @ 0xfffff633 │ │ │ │ andvs r4, r2, fp, asr r6 │ │ │ │ - ldrbcs pc, [r8], r9, asr #4 @ │ │ │ │ + ldrbcs pc, [r0], r9, asr #4 @ │ │ │ │ streq pc, [r2], -r0, asr #5 │ │ │ │ @ instruction: 0xf8cb60c1 │ │ │ │ tstcs r5, r4, lsl r0 │ │ │ │ andvc pc, r8, ip, asr #17 │ │ │ │ andsvc pc, r8, #64, 4 │ │ │ │ andeq pc, r5, #192, 4 │ │ │ │ andvs pc, r4, ip, asr #17 │ │ │ │ - rsccs pc, r0, r9, asr #4 │ │ │ │ + sbcscs pc, r8, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ mcrr2 7, 15, pc, r2, cr15 @ │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ andscs r4, r8, r3, lsl #13 │ │ │ │ @ instruction: 0xf7fe9205 │ │ │ │ strmi pc, [r1], r3, lsr #20 │ │ │ │ subvs r9, r3, r4, lsl #22 │ │ │ │ - blls 70012c │ │ │ │ + blls 700124 │ │ │ │ sbcvs r6, r2, r3, lsl #1 │ │ │ │ sbcmi pc, sl, #64, 4 │ │ │ │ cmpvs r5, r5 │ │ │ │ @ instruction: 0xf8c92010 │ │ │ │ @ instruction: 0xf7fe2010 │ │ │ │ - bls 11817c │ │ │ │ + bls 118174 │ │ │ │ stmib r0, {r1, r2, r3, r8, fp, ip, pc}^ │ │ │ │ andvs r6, r2, r1, lsl #14 │ │ │ │ @ instruction: 0xf8c960c1 │ │ │ │ andscs r0, r8, r4, lsl r0 │ │ │ │ ldrdhi pc, [r4], -sl @ │ │ │ │ - blx 1d7940 │ │ │ │ - blls 22b164 │ │ │ │ + blx 1d7938 │ │ │ │ + blls 22b15c │ │ │ │ stmdacc r2, {r6, r7, r8, fp, sp, lr, pc} │ │ │ │ bicmi pc, ip, #64, 4 │ │ │ │ andls pc, r0, r0, asr #17 │ │ │ │ andscs r6, r0, r5, asr #2 │ │ │ │ vand d22, d9, d19 │ │ │ │ - vrsra.s64 q9, q12, #64 │ │ │ │ + vrsra.s64 q9, q8, #64 │ │ │ │ rsbsvs r0, r3, r2, lsl #6 │ │ │ │ @ instruction: 0xf9f4f7fe │ │ │ │ - bls eb380 │ │ │ │ - blls 3e1d88 │ │ │ │ + bls eb378 │ │ │ │ + blls 3e1d80 │ │ │ │ stmib sp, {r0, r1, r2, r7, sp, lr}^ │ │ │ │ andvs r5, r2, r0, lsl #10 │ │ │ │ andsvc pc, r8, #64, 4 │ │ │ │ andeq pc, r5, #192, 4 │ │ │ │ cmnvs r0, r3, asr #32 │ │ │ │ vmin.s8 d20, d9, d19 │ │ │ │ - vaddl.s8 , d0, d8 │ │ │ │ + vaddl.s8 , d0, d0 │ │ │ │ vhadd.s8 d16, d9, d2 │ │ │ │ - @ instruction: 0xf2c046bc │ │ │ │ + @ instruction: 0xf2c046b4 │ │ │ │ @ instruction: 0xf8cc0602 │ │ │ │ ldrls r6, [ip], -ip │ │ │ │ - blx ffc579a2 │ │ │ │ + blx ffc5799a │ │ │ │ vqdmulh.s q10, q0, q2 │ │ │ │ vmov.i32 d23, #2048 @ 0x00000800 │ │ │ │ movwls r0, #33285 @ 0x8205 │ │ │ │ ldrvc pc, [fp, -r3, lsl #10] │ │ │ │ andls r9, r5, r7, lsl #22 │ │ │ │ andls r4, fp, #32, 12 @ 0x2000000 │ │ │ │ vpadd.i8 d18, d9, d17 │ │ │ │ - vmlal.s , d16, d0[2] │ │ │ │ + vmlal.s , d16, d0[0] │ │ │ │ strls r0, [sl, #-514] @ 0xfffffdfe │ │ │ │ vqsub.s8 d25, d9, d1 │ │ │ │ - vrshr.s64 , q4, #64 │ │ │ │ + vrshr.s64 , q0, #64 │ │ │ │ ldmdavs lr!, {r1, r9} │ │ │ │ @ instruction: 0xf6429218 │ │ │ │ - vrshr.s64 q8, q0, #64 │ │ │ │ + vmlal.s q8, d16, d0[2] │ │ │ │ andsls r0, r0, #805306368 @ 0x30000000 │ │ │ │ orrhi pc, r3, r0 │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ @ instruction: 0xf1a38462 │ │ │ │ strcs r0, [r0], #-816 @ 0xfffffcd0 │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ ldrtmi r4, [r9], r5, lsr #12 │ │ │ │ - ldcne 2, cr15, [r4], #292 @ 0x124 │ │ │ │ + stcne 2, cr15, [ip], #292 @ 0x124 │ │ │ │ stceq 2, cr15, [r2], {192} @ 0xc0 │ │ │ │ @ instruction: 0xf8cd095b │ │ │ │ movwls ip, #36916 @ 0x9034 │ │ │ │ @ instruction: 0xf1a35d33 │ │ │ │ - bcs 135a2b8 │ │ │ │ + bcs 135a2b0 │ │ │ │ ldm pc, {r2, r4, r6, fp, ip, lr, pc}^ @ │ │ │ │ mvneq pc, r2, lsl r0 @ │ │ │ │ subseq r0, r3, r3, asr r0 │ │ │ │ subseq r0, r3, r3, asr r0 │ │ │ │ subeq r0, sl, #83 @ 0x53 │ │ │ │ subseq r0, r3, r3, asr r0 │ │ │ │ subseq r0, r3, r3, asr r0 │ │ │ │ @@ -8686,23 +8684,23 @@ │ │ │ │ mvneq r0, r3, asr r0 │ │ │ │ addseq r0, r2, #83 @ 0x53 │ │ │ │ mvneq r0, r3, asr r0 │ │ │ │ addseq r0, r8, #268435459 @ 0x10000003 │ │ │ │ subseq r0, r3, r4, asr #4 │ │ │ │ svclt 0x000001e2 │ │ │ │ andeq r0, r5, r8, lsr #4 │ │ │ │ - andeq lr, r2, r8, asr #17 │ │ │ │ + andeq lr, r2, r0, asr #17 │ │ │ │ vpmax.s8 d25, d9, d8 │ │ │ │ - vorr.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.f d19, d0, d0[3] │ │ │ │ strls r0, [r0], #-258 @ 0xfffffefe │ │ │ │ andsvc pc, r8, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0xf7fe6852 │ │ │ │ vadd.f32 , , │ │ │ │ - vsubl.s8 , d16, d16 │ │ │ │ + vrshr.s64 d17, d8, #64 │ │ │ │ strtmi r0, [r1], -r2, lsl #4 │ │ │ │ @ instruction: 0xf00d9806 │ │ │ │ andls pc, r4, sp, ror lr @ │ │ │ │ @ instruction: 0xf8da2018 │ │ │ │ @ instruction: 0xf7fe7024 │ │ │ │ stmdbmi r0!, {r0, r4, r5, r8, fp, ip, sp, lr, pc}^ │ │ │ │ andvs r9, r5, r4, lsl #22 │ │ │ │ @@ -8712,41 +8710,41 @@ │ │ │ │ movtpl pc, #8768 @ 0x2240 @ │ │ │ │ smlabbvs r3, r1, r0, r6 │ │ │ │ orrhi pc, r5, r0 │ │ │ │ strmi r4, [pc], -r5, lsl #12 │ │ │ │ adcsmi r9, fp, #5120 @ 0x1400 │ │ │ │ orrshi pc, r9, r0 │ │ │ │ strcc r4, [r1], #-1584 @ 0xfffff9d0 │ │ │ │ - bl dd7b00 │ │ │ │ + bl ed7af8 │ │ │ │ ldrdvs pc, [r0], -r9 │ │ │ │ @ instruction: 0xf4ff4284 │ │ │ │ strbmi sl, [pc], -sp, ror #30 │ │ │ │ - blcs ac0750 │ │ │ │ + blcs ac0748 │ │ │ │ @ instruction: 0x83a6f000 │ │ │ │ @ instruction: 0xf0002b32 │ │ │ │ - blls 23a7fc │ │ │ │ - eormi pc, ip, r9, asr #4 │ │ │ │ + blls 23a7f4 │ │ │ │ + eormi pc, r4, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ svcls 0x0004f853 │ │ │ │ strbmi r9, [r9], -r8, lsl #6 │ │ │ │ cdp2 0, 4, cr15, cr6, cr13, {0} │ │ │ │ strmi r9, [r6], -fp, lsl #22 │ │ │ │ @ instruction: 0x4698681b │ │ │ │ @ instruction: 0xf8d3b10b │ │ │ │ @ instruction: 0xf8da8004 │ │ │ │ stccs 0, cr4, [r0], {12} │ │ │ │ @ instruction: 0x83a3f000 │ │ │ │ ldrtmi r6, [r0], -r1, ror #18 │ │ │ │ - b ed7b50 │ │ │ │ + b fd7b48 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ stmdavs r3!, {r0, r5, r9, pc} │ │ │ │ @ instruction: 0xf0002b05 │ │ │ │ - blcs 27a3f8 │ │ │ │ + blcs 27a3f0 │ │ │ │ andshi pc, lr, #0 │ │ │ │ - blcs 34218 <__time64@plt+0x22f30> │ │ │ │ + blcs 34210 <__time64@plt+0x22f28> │ │ │ │ eorhi pc, r9, #0 │ │ │ │ ldrmi r6, [r8, #2723] @ 0xaa3 │ │ │ │ eorhi pc, r5, #0 │ │ │ │ @ instruction: 0x3010f8da │ │ │ │ andcs r2, r1, r0, asr #2 │ │ │ │ @ instruction: 0xf8ca3301 │ │ │ │ @ instruction: 0xf7fe3010 │ │ │ │ @@ -8779,67 +8777,67 @@ │ │ │ │ andscc pc, r0, sl, asr #17 │ │ │ │ @ instruction: 0xf886f7fe │ │ │ │ @ instruction: 0x3010f8da │ │ │ │ addvs r4, r3, fp, asr r2 │ │ │ │ subvs r6, r3, r3, ror #21 │ │ │ │ rscvs r4, r0, #36700160 @ 0x2300000 │ │ │ │ strmi r6, [r4], -r4, asr #5 │ │ │ │ - b 63469c │ │ │ │ + b 634694 │ │ │ │ @ instruction: 0xf0400f03 │ │ │ │ - bvs ff8fa424 │ │ │ │ + bvs ff8fa41c │ │ │ │ andseq pc, r8, #4, 2 │ │ │ │ eorvs r2, r1, r4, lsl #2 │ │ │ │ cmnvs r6, fp, lsl #18 │ │ │ │ stm r2, {r0, r1, r8, fp, lr, pc} │ │ │ │ andcs r0, r0, #3 │ │ │ │ stmib r4, {r0, r2, r5, r9, sp, lr}^ │ │ │ │ tstlt fp, r9, lsl #16 │ │ │ │ - b 10b46c0 │ │ │ │ + b 10b46b8 │ │ │ │ addsvs r0, sl, #8, 4 @ 0x80000000 │ │ │ │ movwcs r4, #1608 @ 0x648 │ │ │ │ @ instruction: 0xf7fe6323 │ │ │ │ @ instruction: 0xf8ddf895 │ │ │ │ strmi r9, [r0], r0, asr #32 │ │ │ │ @ instruction: 0xf1c01e46 │ │ │ │ and r0, r6, r1, lsl #10 │ │ │ │ andeq r0, r5, r8, lsr #4 │ │ │ │ svccc 0x0001f816 │ │ │ │ andcc pc, r3, r9, lsl r8 @ │ │ │ │ @ instruction: 0x46407033 │ │ │ │ - b fe157c64 │ │ │ │ + b fe257c5c │ │ │ │ addsmi r1, r8, #2801664 @ 0x2ac000 │ │ │ │ @ instruction: 0x2018d8f4 │ │ │ │ ldrdvs pc, [r4], -sl @ │ │ │ │ @ instruction: 0xf85ef7fe │ │ │ │ - blls 2ab4b0 │ │ │ │ - blls 3b1cac │ │ │ │ + blls 2ab4a8 │ │ │ │ + blls 3b1ca4 │ │ │ │ movwcs r6, #67 @ 0x43 │ │ │ │ strmi lr, [r2], -r0, asr #19 │ │ │ │ vrhadd.s8 q11, q0, │ │ │ │ andscs r5, r0, r7, ror #6 │ │ │ │ @ instruction: 0xf7fe612b │ │ │ │ - bls 217df4 │ │ │ │ + bls 217dec │ │ │ │ andcc r9, r1, #3072 @ 0xc00 │ │ │ │ - blls 3f1ccc │ │ │ │ + blls 3f1cc4 │ │ │ │ umaalvs r2, r3, sl, sl │ │ │ │ movweq pc, #4175 @ 0x104f @ │ │ │ │ andhi pc, ip, r0, asr #17 │ │ │ │ cmnvs r8, r7, lsl #4 │ │ │ │ @ instruction: 0xf0006083 │ │ │ │ @ instruction: 0xf85782f3 │ │ │ │ @ instruction: 0xf7f70f04 │ │ │ │ - blls 214648 │ │ │ │ - blcs c7f10c │ │ │ │ + blls 214650 │ │ │ │ + blcs c7f104 │ │ │ │ @ instruction: 0xf47f683e │ │ │ │ @ instruction: 0x4605ae7d │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0xf04faf26 │ │ │ │ ldrtmi r0, [r9], r0, lsl #24 │ │ │ │ strbtmi r4, [r7], -r4, ror #12 │ │ │ │ - cmppcc r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppcc ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ cdpvc 2, 1, cr15, cr8, cr0, {2} │ │ │ │ cdpeq 2, 0, cr15, cr5, cr0, {6} │ │ │ │ andslt pc, r0, sp, asr #17 │ │ │ │ eorge pc, r4, sp, asr #17 │ │ │ │ @ instruction: 0xf8cd910d │ │ │ │ ldcpl 0, cr14, [r3, #-352]! @ 0xfffffea0 │ │ │ │ @@ -8887,144 +8885,144 @@ │ │ │ │ @ instruction: 0x01a701eb │ │ │ │ andsmi r0, r1, #1073741878 @ 0x40000036 │ │ │ │ stccs 1, cr13, [r5], {7} │ │ │ │ andcs fp, r0, #148, 30 @ 0x250 │ │ │ │ andeq pc, r1, #2 │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ svcmi 0x00a5828e │ │ │ │ - adcne pc, r0, #-1879048188 @ 0x90000004 │ │ │ │ + addsne pc, r8, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ stmdals r6, {r0, r5, r9, sl, lr} │ │ │ │ ldc2l 0, cr15, [sl], #52 @ 0x34 │ │ │ │ ldrdcc pc, [r4], -sl @ │ │ │ │ andscs r4, r8, r0, lsl #13 │ │ │ │ @ instruction: 0xf7fd9304 │ │ │ │ - blls 159cb0 │ │ │ │ + blls 159ca8 │ │ │ │ stmib r0, {r0, r1, r3, r4, r5, r7, r8, sl, lr}^ │ │ │ │ vcgt.s8 d23, d0, d2 │ │ │ │ - blls ee710 │ │ │ │ + blls ee708 │ │ │ │ stmdapl r0, {r6, r7, r8, fp, sp, lr, pc} │ │ │ │ @ instruction: 0x4605bf18 │ │ │ │ strmi r6, [r2], -r2, lsl #2 │ │ │ │ @ instruction: 0xf47f6143 │ │ │ │ andscs sl, r0, sp, ror lr │ │ │ │ @ instruction: 0xf7fd9204 │ │ │ │ - bls 159c88 │ │ │ │ + bls 159c80 │ │ │ │ ldrbmi r9, [pc], -r3, lsl #22 │ │ │ │ movwcs r6, #4099 @ 0x1003 │ │ │ │ vhadd.s8 d22, d25, d3 │ │ │ │ - vrsra.s64 d19, d4, #64 │ │ │ │ + vsubw.s8 , q8, d12 │ │ │ │ subvs r0, r3, r2, lsl #6 │ │ │ │ - orrscc pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ + orrscc pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrmi r6, [r5], -r3, asr #1 │ │ │ │ cmpvs r0, r5, lsl #22 │ │ │ │ @ instruction: 0xf47f42bb │ │ │ │ stmdbvs fp!, {r0, r1, r2, r5, r6, r9, sl, fp, sp, pc}^ │ │ │ │ movwls r2, #16400 @ 0x4010 │ │ │ │ @ instruction: 0xff7ef7fd │ │ │ │ andvs r9, r3, r4, lsl #22 │ │ │ │ cmnvs r8, r1, lsl #6 │ │ │ │ vhadd.s8 d22, d25, d3 │ │ │ │ - vrsra.s64 d19, d4, #64 │ │ │ │ + vsubw.s8 , q8, d12 │ │ │ │ subvs r0, r3, r2, lsl #6 │ │ │ │ - @ instruction: 0x33acf249 │ │ │ │ + @ instruction: 0x33a4f249 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrb r6, [r1], -r3, asr #1 │ │ │ │ @ instruction: 0xe6309a11 │ │ │ │ - bls 36b704 │ │ │ │ + bls 36b6fc │ │ │ │ @ instruction: 0xf00d9806 │ │ │ │ andls pc, r4, sp, lsr #25 │ │ │ │ @ instruction: 0xf8da2018 │ │ │ │ @ instruction: 0xf7fd7024 │ │ │ │ - blls 159c18 │ │ │ │ + blls 159c10 │ │ │ │ andvs r9, r5, r2, lsl r9 │ │ │ │ sbcvs r6, r7, r3, asr #32 │ │ │ │ vmax.s8 d30, d9, d30 │ │ │ │ - vmlal.s , d16, d0[0] │ │ │ │ + vrshr.s64 d17, d24, #64 │ │ │ │ svcls 0x00130202 │ │ │ │ @ instruction: 0xf1a4e79c │ │ │ │ - bls 25aab4 │ │ │ │ + bls 25aaac │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ andsmi r0, sl, #1490944 @ 0x16c000 │ │ │ │ sbcshi pc, r4, r0, asr #32 │ │ │ │ - bcs 2c06dc │ │ │ │ + bcs 2c06d4 │ │ │ │ stccs 15, cr11, [r7], {8} │ │ │ │ @ instruction: 0xf1a2d0eb │ │ │ │ @ instruction: 0xf1a4020e │ │ │ │ - blx fec9a2e0 │ │ │ │ - blx fec968dc │ │ │ │ + blx fec9a2d8 │ │ │ │ + blx fec968d4 │ │ │ │ ldmdbeq r2, {r0, r7, r8, ip, sp, lr, pc}^ │ │ │ │ andmi r0, sl, #1196032 @ 0x124000 │ │ │ │ svcge 0x007df47f │ │ │ │ andeq pc, r3, r4, lsr #3 │ │ │ │ @ instruction: 0xf080fab0 │ │ │ │ andmi r0, r2, #64, 18 @ 0x100000 │ │ │ │ - bls 20e64c │ │ │ │ + bls 20e644 │ │ │ │ andeq pc, pc, #-2147483608 @ 0x80000028 │ │ │ │ @ instruction: 0xf282fab2 │ │ │ │ andsmi r0, r0, #1343488 @ 0x148000 │ │ │ │ svcge 0x0063f43f │ │ │ │ vrhadd.s8 d18, d10, d3 │ │ │ │ - vmlal.s q10, d16, d0[1] │ │ │ │ + vrshr.s64 d20, d28, #64 │ │ │ │ vhsub.s8 d16, d9, d2 │ │ │ │ - vaddl.s8 , d16, d8 │ │ │ │ + vaddl.s8 , d16, d0 │ │ │ │ @ instruction: 0xf00d0002 │ │ │ │ andls pc, r4, r5, ror #24 │ │ │ │ @ instruction: 0xf8da2018 │ │ │ │ @ instruction: 0xf7fd7024 │ │ │ │ - blls 159b88 │ │ │ │ + blls 159b80 │ │ │ │ strmi r6, [r2], -r3, asr #32 │ │ │ │ cmpvs r3, r3, lsl #22 │ │ │ │ movtpl pc, #8768 @ 0x2240 @ │ │ │ │ stmib r0, {r0, r2, sp, lr}^ │ │ │ │ tstvs r3, r2, lsl #14 │ │ │ │ vabd.s8 q15, , │ │ │ │ - vsubl.s8 , d16, d24 │ │ │ │ + vsubl.s8 , d16, d16 │ │ │ │ svcmi 0x004b0202 │ │ │ │ vabd.s8 q15, , q7 │ │ │ │ - vrshr.s64 , q0, #64 │ │ │ │ + vmlal.s , d16, d0[2] │ │ │ │ svcls 0x001b0202 │ │ │ │ ldmib sp, {r3, r6, r8, r9, sl, sp, lr, pc}^ │ │ │ │ smlald r2, r5, r8, r7 │ │ │ │ mrc2 7, 7, pc, cr12, cr13, {7} │ │ │ │ addvs r9, r3, fp, lsl fp │ │ │ │ - blls 122364 │ │ │ │ + blls 12235c │ │ │ │ vst4.16 {d22-d25}, [pc], r3 │ │ │ │ mulvs r5, r6, r3 │ │ │ │ stmib r0, {r2, r6, r7, sp, lr}^ │ │ │ │ strmi r3, [r5], -r4, lsl #2 │ │ │ │ @ instruction: 0xf7fde47d │ │ │ │ - blls 519b30 │ │ │ │ + blls 519b28 │ │ │ │ strmi r6, [r5], -r5 │ │ │ │ movwls lr, #6592 @ 0x19c0 │ │ │ │ sbcvs r2, r4, r0, lsl #6 │ │ │ │ vrhadd.s8 q11, q0, │ │ │ │ @ instruction: 0x610343b4 │ │ │ │ vshl.s8 q15, , │ │ │ │ - vmla.f d18, d0, d0[3] │ │ │ │ + vmla.f d18, d0, d0[1] │ │ │ │ vrhadd.s8 d16, d0, d2 │ │ │ │ vmov.i32 d23, #8 @ 0x00000008 │ │ │ │ cdpmi 0, 3, cr0, cr4, cr5, {0} │ │ │ │ - blx 18d7fa2 │ │ │ │ - bllt 997fa8 │ │ │ │ + blx 18d7f9a │ │ │ │ + bllt 997fa0 │ │ │ │ ldmdami r1!, {r0, r1, r3, r4, r8, sl, fp, ip, sp, lr} │ │ │ │ svclt 0x00082b00 │ │ │ │ eorlt r4, r1, r0, lsr r6 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ tstlt r3, #6488064 @ 0x630000 │ │ │ │ ldrb r4, [r3, #1564] @ 0x61c │ │ │ │ ldmdavs sl, {r0, r1, r5, r6, r7, r9, fp, sp, lr} │ │ │ │ rscsle r2, r7, r5, lsl #20 │ │ │ │ ldrmi r6, [r0, #2714] @ 0xa9a │ │ │ │ ldrmi fp, [r8], -r8, lsl #30 │ │ │ │ - blcs 34144 <__time64@plt+0x22e5c> │ │ │ │ + blcs 3413c <__time64@plt+0x22e54> │ │ │ │ stmdacs r0, {r3, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ msrhi SPSR_fxc, r0 │ │ │ │ - bvs ff8eb7f4 │ │ │ │ + bvs ff8eb7ec │ │ │ │ @ instruction: 0xf47f2b00 │ │ │ │ tstcs r4, r1, lsr #28 │ │ │ │ stmdbls fp, {r0, r5, sp, lr} │ │ │ │ andseq pc, r8, #4, 2 │ │ │ │ stmdbgt r3, {r1, r2, r5, r6, r8, sp, lr} │ │ │ │ andeq lr, r3, r2, lsl #17 │ │ │ │ movwpl lr, #35268 @ 0x89c4 │ │ │ │ @@ -9036,237 +9034,237 @@ │ │ │ │ andscs pc, r0, sl, asr #17 │ │ │ │ mcr2 7, 4, pc, cr4, cr13, {7} @ │ │ │ │ @ instruction: 0xf8da9b04 │ │ │ │ @ instruction: 0x46042010 │ │ │ │ addvs r4, r2, r2, asr r2 │ │ │ │ bfi r6, r8, #0, #27 │ │ │ │ @ instruction: 0xf64c6963 │ │ │ │ - vrshr.s64 , q0, #64 │ │ │ │ + vmlal.s , d16, d0[2] │ │ │ │ vhsub.s8 d16, d9, d2 │ │ │ │ - vbic.i32 d17, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d17, #4 @ 0x00000004 │ │ │ │ vrhadd.s8 d16, d0, d2 │ │ │ │ vmov.i32 d23, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fe0005 │ │ │ │ @ instruction: 0xf104fb11 │ │ │ │ @ instruction: 0x46100218 │ │ │ │ - cmppne ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppne r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fe9204 │ │ │ │ - bvs ff91977c │ │ │ │ + bvs ff919774 │ │ │ │ strb r9, [fp, #2564]! @ 0xa04 │ │ │ │ - rscne pc, r0, #-1879048188 @ 0x90000004 │ │ │ │ + sbcsne pc, r8, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ssat r9, #26, r7, lsl #30 │ │ │ │ andeq r0, r5, r8, lsr #3 │ │ │ │ andeq r0, r5, r8, lsr #4 │ │ │ │ strls r9, [r0], #-2568 @ 0xfffff5f8 │ │ │ │ ldmdavs r2, {r0, r2, r3, r8, fp, ip, pc}^ │ │ │ │ @ instruction: 0xf7fe9816 │ │ │ │ @ instruction: 0xf8dffaf3 │ │ │ │ vshl.s8 q12, q2, │ │ │ │ - vsubl.s8 , d16, d16 │ │ │ │ + vrshr.s64 d17, d8, #64 │ │ │ │ strtmi r0, [r1], -r2, lsl #4 │ │ │ │ @ instruction: 0xf00d9806 │ │ │ │ - blls 298f28 │ │ │ │ + blls 298f20 │ │ │ │ andscs r4, r8, r3, lsl #13 │ │ │ │ ldrdge pc, [r4], -r3 @ │ │ │ │ mrc2 7, 2, pc, cr6, cr13, {7} │ │ │ │ vqdmulh.s d25, d0, d3 │ │ │ │ cmpvs r3, r2, asr #4 │ │ │ │ - blls 12b8c8 │ │ │ │ - blvc 547b8 │ │ │ │ + blls 12b8c0 │ │ │ │ + blvc 547b0 │ │ │ │ stmib r0, {r0, r1, r6, r8, sl, lr}^ │ │ │ │ tstvs r2, r2, lsl #20 │ │ │ │ - blls 18e210 │ │ │ │ + blls 18e208 │ │ │ │ eorsle r4, sp, r3, asr #10 │ │ │ │ strcc r4, [r1], #-1584 @ 0xfffff9d0 │ │ │ │ - stmda r0!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda r4!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrdvs pc, [r0], -r9 │ │ │ │ subsle r4, fp, #132, 4 @ 0x40000008 │ │ │ │ ldr r4, [lr], -pc, lsr #12 │ │ │ │ - adcne pc, r0, #-1879048188 @ 0x90000004 │ │ │ │ + addsne pc, r8, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ mvnhi pc, #14614528 @ 0xdf0000 │ │ │ │ @ instruction: 0xf8dfe7d3 │ │ │ │ - bls 47b070 │ │ │ │ + bls 47b068 │ │ │ │ vabd.s8 q15, , │ │ │ │ - vrshr.s64 d17, d20, #64 │ │ │ │ + vsubl.s8 , d16, d28 │ │ │ │ @ instruction: 0xf8dd0202 │ │ │ │ strb r8, [r8, r8, asr #32] │ │ │ │ - sbcne pc, r0, #-1879048188 @ 0x90000004 │ │ │ │ + adcsne pc, r8, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ldrdhi pc, [ip], #-141 @ 0xffffff73 │ │ │ │ ldmib sp, {r0, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ @ instruction: 0xe7be2818 │ │ │ │ - blcs 61aa4 │ │ │ │ - blls 2508e4 │ │ │ │ - msrcc R8_usr, r9 │ │ │ │ + blcs 61a9c │ │ │ │ + blls 2508dc │ │ │ │ + tstpcc r8, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ andsvc pc, r8, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0x4623685a │ │ │ │ - blx fe75812c │ │ │ │ + blx fe758124 │ │ │ │ vabd.s8 d30, d25, d23 │ │ │ │ - vsubl.s8 , d16, d24 │ │ │ │ + vsubl.s8 , d16, d16 │ │ │ │ @ instruction: 0xf8df0202 │ │ │ │ str r8, [r6, r8, lsl #7]! │ │ │ │ andscs r6, r0, pc, ror #18 │ │ │ │ mcr2 7, 0, pc, cr4, cr13, {7} @ │ │ │ │ andvs r2, r7, r1, lsl #6 │ │ │ │ vhadd.s8 d22, d25, d3 │ │ │ │ - vrsra.s64 d19, d4, #64 │ │ │ │ + vsubw.s8 , q8, d12 │ │ │ │ cmnvs r8, r2, lsl #6 │ │ │ │ vhadd.s8 q11, , │ │ │ │ - vsubw.s8 , q8, d28 │ │ │ │ + vsubw.s8 , q8, d20 │ │ │ │ sbcvs r0, r3, r2, lsl #6 │ │ │ │ andscs lr, r0, lr, lsr #15 │ │ │ │ ldc2l 7, cr15, [r2, #1012]! @ 0x3f4 │ │ │ │ andcs r9, r1, #3072 @ 0xc00 │ │ │ │ addvs r6, r2, r8, ror #2 │ │ │ │ - addscc pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ + addcc pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ subvs r6, r2, r3 │ │ │ │ - addscc pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ + addscc pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ldr r6, [r8, r2, asr #1] │ │ │ │ @ instruction: 0xb010f8dd │ │ │ │ @ instruction: 0xf8dd464f │ │ │ │ ldrb sl, [r0], #36 @ 0x24 │ │ │ │ - sbcscc pc, r8, r9, asr #4 │ │ │ │ + sbcscc pc, r0, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx c581a0 │ │ │ │ + blx c58198 │ │ │ │ andscs r4, r8, r4, lsl #12 │ │ │ │ ldrdhi pc, [r4], -sl @ │ │ │ │ ldc2l 7, cr15, [r0, #1012] @ 0x3f4 │ │ │ │ - blls 3ab9d0 │ │ │ │ + blls 3ab9c8 │ │ │ │ stmdami r2, {r6, r7, r8, fp, sp, lr, pc} │ │ │ │ subvs r2, r3, r0, lsl #8 │ │ │ │ orrvs pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ cmpvs r4, r4 │ │ │ │ teqvs r3, r0, lsl r0 │ │ │ │ stc2l 7, cr15, [r2, #1012] @ 0x3f4 │ │ │ │ ldmdbls lr, {r7, r9, sl, lr} │ │ │ │ andvs r9, r4, lr, lsl #22 │ │ │ │ subvs r2, r1, r1, lsl #8 │ │ │ │ cmnvs r0, r3, asr #1 │ │ │ │ @ instruction: 0xf8c82010 │ │ │ │ @ instruction: 0xf7fd4008 │ │ │ │ - blls 4198c0 │ │ │ │ + blls 4198b8 │ │ │ │ vhadd.s8 q11, , │ │ │ │ - vmla.f d19, d16, d0[6] │ │ │ │ - blls 71a600 │ │ │ │ + vmla.f d19, d16, d0[4] │ │ │ │ + blls 71a5f8 │ │ │ │ vhadd.s8 q11, q8, │ │ │ │ vqdmlal.s , d0, d0[6] │ │ │ │ @ instruction: 0xf8c00305 │ │ │ │ addvs r8, r4, r0 │ │ │ │ vand q11, , q8 │ │ │ │ - vshr.s64 , q10, #64 │ │ │ │ + vmla.i d19, d16, d0[7] │ │ │ │ @ instruction: 0xf8d30002 │ │ │ │ - bl a2618 │ │ │ │ + bl a2610 │ │ │ │ @ instruction: 0xf8c30c04 │ │ │ │ @ instruction: 0xf00dc100 │ │ │ │ @ instruction: 0x4633fadf │ │ │ │ andcs r2, r0, #1073741825 @ 0x40000001 │ │ │ │ andcs lr, r0, #3358720 @ 0x334000 │ │ │ │ andsvc pc, r8, #64, 4 │ │ │ │ andeq pc, r5, #192, 4 │ │ │ │ @ instruction: 0xffa6f7fe │ │ │ │ andscs r4, r0, r0, lsl #13 │ │ │ │ stc2 7, cr15, [sl, #1012] @ 0x3f4 │ │ │ │ addvs r4, r4, r6, lsl #12 │ │ │ │ @ instruction: 0xf8da2200 │ │ │ │ vhadd.s8 d20, d9, d20 │ │ │ │ - vrsra.s64 d19, d4, #64 │ │ │ │ + vsubw.s8 , q8, d12 │ │ │ │ andvs r0, r2, r2, lsl #6 │ │ │ │ andscs r6, r8, r3, ror r0 │ │ │ │ mvnscc pc, #-1879048188 @ 0x90000004 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0xf7fd60f3 │ │ │ │ vmla.f32 , , │ │ │ │ - vsubw.s8 q10, q0, d16 │ │ │ │ + vorr.i32 d20, #2048 @ 0x00000800 │ │ │ │ andvs r0, r5, r2, lsl #6 │ │ │ │ strmi r6, [r5], -r3, asr #32 │ │ │ │ cmpppl ip, #64, 4 @ p-variant is OBSOLETE │ │ │ │ andhi pc, r8, r0, asr #17 │ │ │ │ sbcvs r6, r4, r6, asr #2 │ │ │ │ ldrb r6, [ip], #-259 @ 0xfffffefd │ │ │ │ @ instruction: 0xf8da2018 │ │ │ │ @ instruction: 0xf7fd4024 │ │ │ │ - blls 79981c │ │ │ │ + blls 799814 │ │ │ │ strmi r6, [r5], -r5 │ │ │ │ movwcs r6, #131 @ 0x83 │ │ │ │ smlalbtvs r6, r3, r4, r0 │ │ │ │ - biccc pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ + biccc pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ vhadd.s8 q11, q0, │ │ │ │ tstvs r3, r4, asr r3 │ │ │ │ strmi lr, [r5], -r7, asr #8 │ │ │ │ - blmi fe1533ac │ │ │ │ + blmi fe1533a4 │ │ │ │ @ instruction: 0xf8dae6a8 │ │ │ │ strt r3, [r6], #16 │ │ │ │ movwls r2, #4864 @ 0x1300 │ │ │ │ tstcs r5, r3, lsl #22 │ │ │ │ vcgt.s8 d25, d0, d0 │ │ │ │ vmov.i32 d23, #2048 @ 0x00000800 │ │ │ │ strtmi r0, [fp], -r5, lsl #4 │ │ │ │ - eorsmi pc, r8, r9, asr #4 │ │ │ │ + eorsmi pc, r0, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xff54f7fe │ │ │ │ @ instruction: 0xf7ff4606 │ │ │ │ movwcs fp, #6538 @ 0x198a │ │ │ │ - blt 1f582e4 │ │ │ │ - sbcsne pc, r0, #-1879048188 @ 0x90000004 │ │ │ │ + blt 1f582dc │ │ │ │ + sbcne pc, r8, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ldrdhi pc, [ip], #-141 @ 0xffffff73 @ │ │ │ │ - bls 213e2c │ │ │ │ + bls 213e24 │ │ │ │ svclt 0x00142a17 │ │ │ │ @ instruction: 0xf0012100 │ │ │ │ @ instruction: 0xb1290101 │ │ │ │ - adcne pc, r0, #-1879048188 @ 0x90000004 │ │ │ │ + addsne pc, r8, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ strb r4, [r9, #-3950]! @ 0xfffff092 │ │ │ │ - blx fed2bb54 │ │ │ │ + blx fed2bb4c │ │ │ │ ldmdbeq r2, {r2, r7, r9, ip, sp, lr, pc}^ │ │ │ │ svclt 0x00142801 │ │ │ │ @ instruction: 0xf0022100 │ │ │ │ stmdbcs r0, {r0, r8} │ │ │ │ ldclge 4, cr15, [r9, #-508] @ 0xfffffe04 │ │ │ │ svclt 0x00142802 │ │ │ │ @ instruction: 0xf0022100 │ │ │ │ stmdbcs r0, {r0, r8} │ │ │ │ mcrge 4, 0, pc, cr7, cr15, {3} @ │ │ │ │ svclt 0x00142832 │ │ │ │ @ instruction: 0xf0032300 │ │ │ │ - blcs 1af48 <__time64@plt+0x9c60> │ │ │ │ + blcs 1af40 <__time64@plt+0x9c58> │ │ │ │ adcshi pc, r7, r0, asr #32 │ │ │ │ stccs 6, cr4, [r3], {3} │ │ │ │ movweq pc, #49571 @ 0xc1a3 @ │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ cmpne r3, #323584 @ 0x4f000 │ │ │ │ movwcs fp, #3992 @ 0xf98 │ │ │ │ @ instruction: 0xf47f2b00 │ │ │ │ @ instruction: 0x4603ad3c │ │ │ │ @ instruction: 0xf1a32c01 │ │ │ │ - blx fecdafa0 │ │ │ │ - b 141717c │ │ │ │ + blx fecdaf98 │ │ │ │ + b 1417174 │ │ │ │ svclt 0x00981353 │ │ │ │ - blcs 22f78 <__time64@plt+0x11c90> │ │ │ │ - stcge 4, cr15, [pc, #-508]! @ 1a180 <__time64@plt+0x8e98> │ │ │ │ + blcs 22f70 <__time64@plt+0x11c88> │ │ │ │ + stcge 4, cr15, [pc, #-508]! @ 1a178 <__time64@plt+0x8e90> │ │ │ │ svclt 0x00142897 │ │ │ │ @ instruction: 0xf0022200 │ │ │ │ - bcs 1ab8c <__time64@plt+0x98a4> │ │ │ │ + bcs 1ab84 <__time64@plt+0x989c> │ │ │ │ stcge 4, cr15, [r9, #508] @ 0x1fc │ │ │ │ vqdmulh.s d25, d9, d8 │ │ │ │ - vaddw.s8 , q0, d16 │ │ │ │ + vorr.i32 d19, #8 @ 0x00000008 │ │ │ │ vrhadd.s8 d16, d0, d2 │ │ │ │ vmov.i32 d23, #8 @ 0x00000008 │ │ │ │ svcmi 0x004b0005 │ │ │ │ @ instruction: 0x4623685a │ │ │ │ @ instruction: 0xf962f7fe │ │ │ │ - adcne pc, r0, #-1879048188 @ 0x90000004 │ │ │ │ + addsne pc, r8, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ vqrshl.s8 d30, d8, d0 │ │ │ │ @ instruction: 0xf2c03af0 │ │ │ │ cmpcs r0, r5, lsl #20 │ │ │ │ @ instruction: 0xf7fd4620 │ │ │ │ movwcs pc, #27825 @ 0x6cb1 @ │ │ │ │ @ instruction: 0xf8da6003 │ │ │ │ @@ -9326,15 +9324,15 @@ │ │ │ │ andcs r3, r6, #16 │ │ │ │ andvs r6, r2, r5, asr #2 │ │ │ │ andsls r1, r7, sl, asr ip │ │ │ │ @ instruction: 0xf8ca43db │ │ │ │ addvs r2, r3, r0, lsl r0 │ │ │ │ @ instruction: 0xf7ff60e8 │ │ │ │ vmul.i8 d27, d10, d1 │ │ │ │ - vmlal.s q10, d16, d0[1] │ │ │ │ + vrshr.s64 d20, d28, #64 │ │ │ │ svcls 0x00050202 │ │ │ │ svclt 0x0000e490 │ │ │ │ strdeq r0, [r5], -ip │ │ │ │ andeq r0, r5, r8, lsr #3 │ │ │ │ andeq r0, r5, r8, lsr #4 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ @ instruction: 0xf8dd4607 │ │ │ │ @@ -9356,15 +9354,15 @@ │ │ │ │ @ instruction: 0x4604fc1f │ │ │ │ strbmi r2, [r0], -r0, lsl #2 │ │ │ │ @ instruction: 0xf840f7ff │ │ │ │ rsbvs r4, r7, r3, lsl #12 │ │ │ │ eorvs r2, r3, r0, lsl r0 │ │ │ │ @ instruction: 0xf7fd60a6 │ │ │ │ tstpcs r3, r3, lsl ip @ p-variant is OBSOLETE │ │ │ │ - sbcvc pc, r0, #72, 12 @ 0x4800000 │ │ │ │ + adcsvc pc, r8, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ stmib r0, {r0, r2, sp, lr}^ │ │ │ │ sbcvs r2, r4, r1, lsl #2 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ svcmi 0x00f0e92d │ │ │ │ tstcs sl, lr, lsl #12 │ │ │ │ strmi fp, [r4], -r5, lsl #1 │ │ │ │ @@ -9377,123 +9375,123 @@ │ │ │ │ ldmdavs fp, {r0, r1, r8, ip, sp, pc}^ │ │ │ │ ldrtmi r4, [r2], -r9, asr #12 │ │ │ │ @ instruction: 0xf8c94620 │ │ │ │ @ instruction: 0xf7fe3028 │ │ │ │ @ instruction: 0x4620fd7f │ │ │ │ stc2 7, cr15, [r8], {253} @ 0xfd │ │ │ │ andls r2, r3, ip, lsr r1 │ │ │ │ - mcr 7, 0, pc, cr10, cr6, {7} @ │ │ │ │ + mcr 7, 0, pc, cr14, cr6, {7} @ │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ mcrrne 0, 9, r8, r4, cr0 │ │ │ │ - msrmi (UNDEF: 100), r9 │ │ │ │ + cmppmi ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f64620 │ │ │ │ - bl 156028 │ │ │ │ + bl 156030 │ │ │ │ @ instruction: 0x5c220a00 │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ ldrbmi r8, [r0], -r1, lsr #1 │ │ │ │ - msrmi (UNDEF: 100), r9 │ │ │ │ + cmppmi ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldc 7, cr15, [lr, #-984] @ 0xfffffc28 │ │ │ │ + stc 7, cr15, [r2, #-984]! @ 0xfffffc28 │ │ │ │ andcs pc, r0, sl, lsl r8 @ │ │ │ │ streq lr, [r0], #-2826 @ 0xfffff4f6 │ │ │ │ strcc fp, [r1], #-282 @ 0xfffffee6 │ │ │ │ @ instruction: 0xf80a2200 │ │ │ │ vhadd.s8 d18, d9, d0 │ │ │ │ - vqdmull.s q10, d0, d0[6] │ │ │ │ + vqdmull.s q10, d0, d0[4] │ │ │ │ vqdmulh.s d16, d9, d2 │ │ │ │ - vmul.i d20, d0, d0[5] │ │ │ │ + vmov.i16 q10, #12 @ 0x000c │ │ │ │ movwcs r0, #2050 @ 0x802 │ │ │ │ ldrbmi r9, [r9], -r0, lsl #6 │ │ │ │ @ instruction: 0xf7f64650 │ │ │ │ - strmi lr, [r5], -r8, ror #25 │ │ │ │ + strmi lr, [r5], -ip, ror #25 │ │ │ │ strbmi fp, [r1], -r8, ror #3 │ │ │ │ @ instruction: 0xf7f64620 │ │ │ │ - stcpl 14, cr14, [r2], #-480 @ 0xfffffe20 │ │ │ │ - beq 55208 │ │ │ │ + stcpl 14, cr14, [r2], #-496 @ 0xfffffe10 │ │ │ │ + beq 55200 │ │ │ │ subsle r2, r5, r0, lsl #20 │ │ │ │ ldrbmi r4, [r0], -r1, asr #12 │ │ │ │ - ldcl 7, cr15, [r8], #984 @ 0x3d8 │ │ │ │ + ldcl 7, cr15, [ip], #984 @ 0x3d8 │ │ │ │ andcs pc, r0, sl, lsl r8 @ │ │ │ │ streq lr, [r0], #-2826 @ 0xfffff4f6 │ │ │ │ rscle r2, r6, r0, lsl #20 │ │ │ │ ldrbmi r2, [r9], -r0, lsl #4 │ │ │ │ andcs pc, r0, sl, lsl #16 │ │ │ │ @ instruction: 0xf7f64650 │ │ │ │ - strcc lr, [r1], #-3276 @ 0xfffff334 │ │ │ │ + strcc lr, [r1], #-3280 @ 0xfffff330 │ │ │ │ stmdacs r0, {r0, r2, r9, sl, lr} │ │ │ │ @ instruction: 0x212ad1e1 │ │ │ │ @ instruction: 0xf7f64650 │ │ │ │ - @ instruction: 0x9001edb8 │ │ │ │ + @ instruction: 0x9001edbc │ │ │ │ @ instruction: 0xf7fd4650 │ │ │ │ - bls 994ec │ │ │ │ - bcs 2be58 <__time64@plt+0x1ab70> │ │ │ │ - bl fe8ce740 │ │ │ │ + bls 994e4 │ │ │ │ + bcs 2be50 <__time64@plt+0x1ab68> │ │ │ │ + bl fe8ce738 │ │ │ │ strpl r0, [r5], #522 @ 0x20a │ │ │ │ @ instruction: 0xffe0f7fd │ │ │ │ stmiavs r0, {r0, r2, r9, sl, lr}^ │ │ │ │ eorsle r2, fp, r0, lsl #16 │ │ │ │ @ instruction: 0xf7fe2100 │ │ │ │ ldmdavs r2!, {r0, r2, r5, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ sxtab16mi r6, r2, r3, ror #16 │ │ │ │ andls r2, r2, #24 │ │ │ │ @ instruction: 0xf7fd9301 │ │ │ │ - blls 59444 │ │ │ │ + blls 5943c │ │ │ │ stm r0, {r0, r2, r9, sl, lr} │ │ │ │ strbmi r0, [r1], -r8, lsl #9 │ │ │ │ - blls 80e7c │ │ │ │ + blls 80e74 │ │ │ │ sbcvs r2, r2, r0, lsl #14 │ │ │ │ tstvs r3, r7, asr #2 │ │ │ │ @ instruction: 0xf7f64620 │ │ │ │ - stcpl 14, cr14, [r2], #-192 @ 0xffffff40 │ │ │ │ - beq 55298 │ │ │ │ + stcpl 14, cr14, [r2], #-208 @ 0xffffff30 │ │ │ │ + beq 55290 │ │ │ │ strbmi fp, [r1], -sl, ror #2 │ │ │ │ @ instruction: 0xf7f64650 │ │ │ │ - @ instruction: 0xf81aecb2 │ │ │ │ - bl 2a2698 │ │ │ │ + @ instruction: 0xf81aecb6 │ │ │ │ + bl 2a2690 │ │ │ │ cmnlt sl, r0, lsl #8 │ │ │ │ @ instruction: 0xf80a3401 │ │ │ │ strls r7, [r0, #-0] │ │ │ │ strls lr, [r0, #-1947] @ 0xfffff865 │ │ │ │ @ instruction: 0xf8c99b00 │ │ │ │ stmdals r3, {r5, ip, sp} │ │ │ │ - ldc 7, cr15, [r6], #984 @ 0x3d8 │ │ │ │ + ldc 7, cr15, [sl], #984 @ 0x3d8 │ │ │ │ andlt r4, r5, r8, asr #12 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ str r9, [lr, r0, lsl #10] │ │ │ │ @ instruction: 0xf0004631 │ │ │ │ bfi pc, r5, (invalid: 16:3) @ │ │ │ │ andcs r2, r1, r0, asr #2 │ │ │ │ - blx ad86c6 │ │ │ │ + blx ad86be │ │ │ │ rscscc pc, r0, #64, 4 │ │ │ │ andeq pc, r5, #192, 4 │ │ │ │ andvs r2, r3, r6, lsl #6 │ │ │ │ ldmdbvs r3, {r0, r2, r6, r8, sp, lr} │ │ │ │ bicsmi r1, fp, #22784 @ 0x5900 │ │ │ │ addvs r6, r3, r1, lsl r1 │ │ │ │ ldr r6, [r1, r8, ror #1]! │ │ │ │ ldrb r9, [fp, r0, lsl #4] │ │ │ │ andcs fp, r5, #248, 10 @ 0x3e000000 │ │ │ │ strmi r4, [pc], -r6, lsl #12 │ │ │ │ - cmnpmi r0, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + msrmi (UNDEF: 104), r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f61d75 │ │ │ │ - ldrdlt lr, [r0, -ip] │ │ │ │ + smlattlt r0, r0, sp, lr │ │ │ │ vmin.s8 d20, d0, d21 │ │ │ │ vrsra.s64 , q8, #64 │ │ │ │ ldmibvs ip, {r0, r2, r8, r9}^ │ │ │ │ and fp, fp, r4, lsl r9 │ │ │ │ cmplt ip, r4, lsr #16 │ │ │ │ strtmi r6, [r9], -r0, ror #16 │ │ │ │ - stcl 7, cr15, [r2], #-984 @ 0xfffffc28 │ │ │ │ + stcl 7, cr15, [r6], #-984 @ 0xfffffc28 │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ smlatblt ip, r4, r8, r6 │ │ │ │ ldcllt 6, cr4, [r8, #128]! @ 0x80 │ │ │ │ @ instruction: 0x4630213c │ │ │ │ - ldc 7, cr15, [r2, #-984]! @ 0xfffffc28 │ │ │ │ + ldc 7, cr15, [r6, #-984]! @ 0xfffffc28 │ │ │ │ ldrtmi fp, [r9], -r8, lsr #2 │ │ │ │ pop {r4, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7ff40f8 │ │ │ │ strdcs fp, [r1, -pc] │ │ │ │ @ instruction: 0xf7fe4630 │ │ │ │ @ instruction: 0xf100fe2b │ │ │ │ @ instruction: 0x46040318 │ │ │ │ @@ -9505,97 +9503,97 @@ │ │ │ │ @ instruction: 0xf7fe62a3 │ │ │ │ ldrb pc, [sp, r5, lsl #25] @ │ │ │ │ eorsle r2, r7, r0, lsl #16 │ │ │ │ ldrblt fp, [r0, #-1038]! @ 0xfffffbf2 │ │ │ │ addlt r4, r3, r5, lsl #12 │ │ │ │ strbtmi sl, [r8], -r8, lsl #20 │ │ │ │ andls r9, r1, #114688 @ 0x1c000 │ │ │ │ - stc 7, cr15, [r2], #-984 @ 0xfffffc28 │ │ │ │ + stc 7, cr15, [r6], #-984 @ 0xfffffc28 │ │ │ │ strmi r9, [r6], -r0, lsl #18 │ │ │ │ @ instruction: 0xf381fab1 │ │ │ │ - b 14dcd00 │ │ │ │ + b 14dccf8 │ │ │ │ ldrdle r7, [r6, -r0]! │ │ │ │ stmiavs ip!, {r1, r3, r5, r6, r7, fp, sp, lr} │ │ │ │ adcmi r1, r3, #1245184 @ 0x130000 │ │ │ │ @ instruction: 0x2c00d910 │ │ │ │ @ instruction: 0xf44fbf08 │ │ │ │ rsbeq r6, r4, r0, lsl #9 │ │ │ │ rscsle r4, ip, #805306378 @ 0x3000000a │ │ │ │ stmdbvs r8!, {r0, r5, r9, sl, lr} │ │ │ │ - blx ff6d87ac │ │ │ │ + blx ff6d87a4 │ │ │ │ @ instruction: 0x612868eb │ │ │ │ ldrmi r9, [r8], #-2304 @ 0xfffff700 │ │ │ │ and r6, r1, ip, lsr #1 │ │ │ │ ldrmi r6, [r0], #-2344 @ 0xfffff6d8 │ │ │ │ @ instruction: 0xf7f64632 │ │ │ │ - stmiavs fp!, {r1, r4, r5, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs fp!, {r1, r2, r4, r5, sl, fp, sp, lr, pc}^ │ │ │ │ ldrtmi r9, [r3], #-2048 @ 0xfffff800 │ │ │ │ @ instruction: 0xf7f660eb │ │ │ │ - andlt lr, r3, r4, lsr #24 │ │ │ │ + andlt lr, r3, r8, lsr #24 │ │ │ │ ldrhtmi lr, [r0], #-141 @ 0xffffff73 │ │ │ │ ldrbmi fp, [r0, -r3]! │ │ │ │ vaba.s8 q10, , q8 │ │ │ │ - vmvn.i32 q10, #8 @ 0x00000008 │ │ │ │ + vmvn.i32 q10, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf7f60002 │ │ │ │ - svclt 0x0000fe13 │ │ │ │ + svclt 0x0000fe17 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stmdbcs r0, {r1, r2, r3, r9, sl, lr} │ │ │ │ strmi sp, [r5], -r5, rrx │ │ │ │ vmin.s8 d20, d10, d4 │ │ │ │ - vsra.s64 q11, q10, #64 │ │ │ │ + vmla.f d22, d16, d0[7] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ @ instruction: 0x4622ffb1 │ │ │ │ vmax.s8 d20, d9, d24 │ │ │ │ - vaddw.s8 q10, q8, d28 │ │ │ │ + vaddw.s8 q10, q8, d20 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ strtmi pc, [r8], -r9, lsr #31 │ │ │ │ - @ instruction: 0x41b8f249 │ │ │ │ + asrsmi pc, r9, #4 @ │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xffa2f7ff │ │ │ │ stmdavs r3!, {r2, r4, r5, r7, fp, sp, lr} │ │ │ │ tstle fp, r7, lsl #22 │ │ │ │ - stmiami r8, {r0, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ + stmiami r0, {r0, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdaeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - strbmi pc, [r0, r9, asr #4] @ │ │ │ │ + ldrmi pc, [r8, r9, asr #4]! │ │ │ │ streq pc, [r2, -r0, asr #5] │ │ │ │ ldmvs r3!, {r1, r2, sp, lr, pc} │ │ │ │ eorsle r4, r8, r3, lsr #5 │ │ │ │ stmdavs r3!, {r2, r5, r6, r8, fp, sp, lr} │ │ │ │ tstle fp, r7, lsl #22 │ │ │ │ ldrtmi r6, [r9], -r2, lsr #19 │ │ │ │ - blcs 388a8 <__time64@plt+0x275c0> │ │ │ │ + blcs 388a0 <__time64@plt+0x275b8> │ │ │ │ @ instruction: 0x4628d0f3 │ │ │ │ @ instruction: 0xff86f7ff │ │ │ │ stmdavs r3!, {r2, r5, r6, r8, fp, sp, lr} │ │ │ │ rscsle r2, r3, r7, lsl #22 │ │ │ │ vmax.s8 d20, d9, d24 │ │ │ │ - vmla.f d22, d16, d0[3] │ │ │ │ + vmla.f d22, d16, d0[1] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ ldmdavs r2!, {r0, r1, r3, r4, r5, r6, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ vmax.s8 d20, d9, d24 │ │ │ │ - vsra.s64 q10, q6, #64 │ │ │ │ + vsra.s64 q10, q2, #64 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ ldmvs r4!, {r0, r1, r4, r5, r6, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - blcs 1f491c │ │ │ │ + blcs 1f4914 │ │ │ │ vrhadd.s8 d29, d9, d11 │ │ │ │ - vmlsl.s q10, d16, d0[7] │ │ │ │ + vmlsl.s q10, d16, d0[5] │ │ │ │ ldrtmi r0, [r1], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ stmdbvs r4!, {r0, r1, r2, r5, r6, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - blcs 1f4934 │ │ │ │ + blcs 1f492c │ │ │ │ @ instruction: 0x4628d0f7 │ │ │ │ - mvnsmi pc, r9, asr #4 │ │ │ │ + mvnmi pc, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xff5cf7ff │ │ │ │ pop {r0, sp} │ │ │ │ ldmdavs r2!, {r4, r5, r6, r7, r8, pc}^ │ │ │ │ strtmi r4, [r8], -r1, asr #12 │ │ │ │ @ instruction: 0xff54f7ff │ │ │ │ ldrmi lr, [r8], -ip, asr #15 │ │ │ │ - orrmi pc, r8, r9, asr #4 │ │ │ │ + orrmi pc, r0, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf98af7fe │ │ │ │ pop {r4, r5, r9, sl, lr} │ │ │ │ svclt 0x000081f0 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ pkhbtmi r4, r0, r9, lsl #13 │ │ │ │ svcge 0x0006b08f │ │ │ │ @@ -9606,98 +9604,98 @@ │ │ │ │ @ instruction: 0xf013e8df │ │ │ │ eoreq r0, r7, r7, lsr #32 │ │ │ │ eorseq r0, r3, r3, lsr #32 │ │ │ │ eoreq r0, r7, r0, asr r0 │ │ │ │ ldrdeq r0, [fp], -r6 │ │ │ │ eoreq r0, r7, r7, lsr #32 │ │ │ │ strbmi r0, [r9], -r8, lsl #2 │ │ │ │ - sbcspl pc, r4, r9, asr #4 │ │ │ │ + sbcpl pc, ip, r9, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xff5ef00c │ │ │ │ ldmdbvs r9!, {r0, r1, r3, r4, r5, r8, fp, sp, lr}^ │ │ │ │ strbmi r4, [r0], -r4, lsl #12 │ │ │ │ ldmvs fp!, {r1, r3, r4, r6, r8, fp, sp, lr}^ │ │ │ │ strtmi r9, [r3], -r2, lsl #6 │ │ │ │ strls r6, [r1, #-3325] @ 0xfffff303 │ │ │ │ strls r6, [r0, #-3261] @ 0xfffff343 │ │ │ │ @ instruction: 0xffd0f7ff │ │ │ │ @ instruction: 0xf7f64620 │ │ │ │ - strcc lr, [r4, -lr, ror #22]! │ │ │ │ + @ instruction: 0x3724eb72 │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ ldclvs 15, cr8, [r8], #960 @ 0x3c0 │ │ │ │ vmax.s8 q10, , q5 │ │ │ │ - vaddw.s8 , q0, d24 │ │ │ │ + vaddw.s8 , q0, d16 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ strcc pc, [r4, -r7, asr #18]! │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ ldclvs 15, cr8, [fp], #960 @ 0x3c0 │ │ │ │ ldmdbvs r9!, {r1, r3, r6, r9, sl, lr}^ │ │ │ │ @ instruction: 0xff42f7ff │ │ │ │ rscle r2, r8, r0, lsl #16 │ │ │ │ vmax.s8 q10, , q0 │ │ │ │ - vsra.s64 q11, q0, #64 │ │ │ │ + vmla.f d22, d16, d0[2] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ @ instruction: 0x4640fef7 │ │ │ │ mvnsvs pc, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mrc2 7, 7, pc, cr0, cr15, {7} │ │ │ │ vmax.s8 q10, , q0 │ │ │ │ - vaddw.s8 , q0, d16 │ │ │ │ + vorr.i32 d23, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ ldrb pc, [r2, r9, ror #29] @ │ │ │ │ @ instruction: 0xf8d3693b │ │ │ │ @ instruction: 0xf1baa020 │ │ │ │ sbcle r0, ip, r0, lsl #30 │ │ │ │ @ instruction: 0x4014f8da │ │ │ │ - blvc feb582d4 │ │ │ │ - bleq d74b8 │ │ │ │ - movwcc pc, #16969 @ 0x4249 @ │ │ │ │ + blvc fe9582cc │ │ │ │ + bleq d74b0 │ │ │ │ + mvnscs pc, #-1879048188 @ 0x90000004 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrhtvs r6, [fp], -r8 │ │ │ │ andsls pc, ip, r7, asr #17 │ │ │ │ subsle r2, lr, r0, lsl #24 │ │ │ │ cdpeq 0, 0, cr15, cr0, cr15, {2} │ │ │ │ - mvnsmi pc, r9, asr #4 │ │ │ │ + mvnmi pc, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldrcc pc, [r4], r9, asr #4 │ │ │ │ + strcc pc, [ip], r9, asr #4 │ │ │ │ streq pc, [r2], -r0, asr #5 │ │ │ │ @ instruction: 0x468846f1 │ │ │ │ ands pc, r8, r7, asr #17 │ │ │ │ @ instruction: 0xf7f6e01f │ │ │ │ - @ instruction: 0x4641eafe │ │ │ │ + strbmi lr, [r1], -r2, lsl #22 │ │ │ │ strtmi r4, [r8], -r3, lsl #12 │ │ │ │ stmiavs r3!, {r0, r1, r3, r5, r8, fp, ip, sp, pc} │ │ │ │ svclt 0x00042b01 │ │ │ │ @ instruction: 0x61bb68e3 │ │ │ │ @ instruction: 0xf7f6d011 │ │ │ │ - vpmin.s8 q15, , q9 │ │ │ │ - vaddw.s8 , q0, d4 │ │ │ │ + vpmin.s8 q15, , q11 │ │ │ │ + vsra.s64 q10, q14, #64 │ │ │ │ ldmibvs fp!, {r1, r8}^ │ │ │ │ ldrdgt pc, [r4], -sl │ │ │ │ stmdacs r0, {r1, r3, r5, r9, sl, lr} │ │ │ │ addhi pc, r7, r0, asr #32 │ │ │ │ strbtmi r9, [r3], -r0, lsl #6 │ │ │ │ @ instruction: 0xf7fe6cf8 │ │ │ │ stmdavs r4!, {r0, r1, r5, r6, r7, fp, ip, sp, lr, pc} │ │ │ │ stmdavs r5!, {r2, r4, r5, r6, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0x46284659 │ │ │ │ - b ff6d8a0c │ │ │ │ + b ff7d8a04 │ │ │ │ @ instruction: 0x46034631 │ │ │ │ - blcs 2c2dc <__time64@plt+0x1aff4> │ │ │ │ + blcs 2c2d4 <__time64@plt+0x1afec> │ │ │ │ stmdavs r4!, {r0, r2, r4, r6, r7, r8, ip, lr, pc} │ │ │ │ stmdbeq r1, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ @ instruction: 0xe018f8d7 │ │ │ │ svceq 0x0000f1b9 │ │ │ │ @ instruction: 0xf8dad111 │ │ │ │ @ instruction: 0xf1be3008 │ │ │ │ andsle r0, r6, r0, lsl #30 │ │ │ │ stmdbcs r5, {r0, r3, r4, fp, sp, lr} │ │ │ │ vhadd.s8 , , │ │ │ │ - vaddw.s8 , q8, d16 │ │ │ │ + vsra.s64 d21, d8, #64 │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ ldmibvs sl!, {r2, ip, sp}^ │ │ │ │ @ instruction: 0xf7fe6cf8 │ │ │ │ @ instruction: 0xf8daf8bb │ │ │ │ @ instruction: 0xf1baa000 │ │ │ │ @ instruction: 0xf43f0f00 │ │ │ │ @ instruction: 0xf8daaf62 │ │ │ │ @@ -9716,59 +9714,59 @@ │ │ │ │ stmdacs r0, {r0, r1, r2, r3, r4, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ svcge 0x0045f43f │ │ │ │ @ instruction: 0x6cb9693b │ │ │ │ ldmdavs sl, {r0, r1, r3, r4, r6, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf0002900 │ │ │ │ svcne 0x001380ac │ │ │ │ stmdble r3, {r1, r8, r9, fp, sp} │ │ │ │ - bcs 692f8 │ │ │ │ + bcs 692f0 │ │ │ │ adchi pc, r9, r0, lsl #4 │ │ │ │ strbmi r4, [r0], -sl, asr #12 │ │ │ │ - cmnpvs r0, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + msrvs (UNDEF: 104), r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mcr2 7, 2, pc, cr4, cr15, {7} @ │ │ │ │ - blcs 34ed8 <__time64@plt+0x23bf0> │ │ │ │ + blcs 34ed0 <__time64@plt+0x23be8> │ │ │ │ sbchi pc, fp, r0 │ │ │ │ - @ instruction: 0x61b4f249 │ │ │ │ + @ instruction: 0x61acf249 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ strbmi r4, [r0], -sl, asr #12 │ │ │ │ mrc2 7, 1, pc, cr8, cr15, {7} │ │ │ │ vmax.s8 q10, , q0 │ │ │ │ - vmla.f d22, d16, d0[2] │ │ │ │ + vmla.f d22, d16, d0[0] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ @ instruction: 0xe71afe31 │ │ │ │ vmul.i8 q11, , │ │ │ │ - vsra.s64 , q6, #64 │ │ │ │ + vsra.s64 , q2, #64 │ │ │ │ ldclvs 1, cr0, [r8], #8 │ │ │ │ @ instruction: 0xf7fe685a │ │ │ │ strcc pc, [r4, -r5, ror #16]! │ │ │ │ pop {r0, r2, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ strls r8, [r0, #-4080] @ 0xfffff010 │ │ │ │ ldclvs 6, cr4, [r8], #392 @ 0x188 │ │ │ │ - teqppl ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqppl r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf858f7fe │ │ │ │ - bvs 75490c │ │ │ │ + bvs 754904 │ │ │ │ addsle r2, r8, r0, lsl #24 │ │ │ │ - rsbspl pc, r0, #-1879048188 @ 0x90000004 │ │ │ │ + rsbpl pc, r8, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ldrdhi pc, [r0], -r7 │ │ │ │ andsls pc, r8, r7, asr #17 │ │ │ │ @ instruction: 0xf8c746f1 │ │ │ │ ldrmi fp, [r3], r4 │ │ │ │ @ instruction: 0xb3266966 │ │ │ │ ldmdavs r0!, {r8, sl, sp}^ │ │ │ │ @ instruction: 0xf7f64641 │ │ │ │ - ldmdblt r8, {r6, r9, fp, sp, lr, pc} │ │ │ │ - blcs 74e3c │ │ │ │ + ldmdblt r8, {r2, r6, r9, fp, sp, lr, pc} │ │ │ │ + blcs 74e34 │ │ │ │ ldmvs r5!, {r3, r8, r9, sl, fp, ip, sp, pc}^ │ │ │ │ mcrcs 8, 0, r6, cr0, cr6, {1} │ │ │ │ @ instruction: 0xb1b5d1f3 │ │ │ │ strtmi r4, [r8], -r9, asr #12 │ │ │ │ - b cd8b5c │ │ │ │ + b dd8b54 │ │ │ │ ldmibvs fp!, {r3, r7, r8, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf8dab173 │ │ │ │ ldrbmi r3, [r9], -r4 │ │ │ │ ldmibvs sl!, {r2, r8, sl, ip, pc}^ │ │ │ │ stmib sp, {r5, r6, fp, sp, lr}^ │ │ │ │ andls r3, r1, #2 │ │ │ │ stmdavs r0, {r3, r4, r5, r7, r8, fp, sp, lr}^ │ │ │ │ @@ -9779,88 +9777,88 @@ │ │ │ │ @ instruction: 0x9018f8d7 │ │ │ │ ldrdlt pc, [r4], -r7 │ │ │ │ svceq 0x0000f1b9 │ │ │ │ svcge 0x005bf43f │ │ │ │ ldrdcs pc, [r4], -r9 │ │ │ │ @ instruction: 0xf8da4623 │ │ │ │ @ instruction: 0xf6480004 │ │ │ │ - vaddw.s8 q10, q0, d24 │ │ │ │ + vaddw.s8 q10, q0, d16 │ │ │ │ @ instruction: 0xf8d90102 │ │ │ │ @ instruction: 0xf00c5008 │ │ │ │ @ instruction: 0xf100fd73 │ │ │ │ @ instruction: 0xf0230308 │ │ │ │ @ instruction: 0xf8d90307 │ │ │ │ - bl feb62bf8 │ │ │ │ + bl feb62bf0 │ │ │ │ strtmi r0, [r3], -r3, lsl #26 │ │ │ │ streq pc, [r0], #1600 @ 0x640 │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ ldrdeq pc, [r4], -sl │ │ │ │ - msrmi R8_fiq, r8 │ │ │ │ + msrmi R8_usr, r8 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ eorvs sl, r6, r6, lsl #28 │ │ │ │ ldc2l 0, cr15, [r2, #-48]! @ 0xffffffd0 │ │ │ │ andpl lr, r2, sp, asr #19 │ │ │ │ movwls r6, #6395 @ 0x18fb │ │ │ │ movwls r6, #3323 @ 0xcfb │ │ │ │ ldmib r7, {r0, r1, r3, r4, r5, r6, r7, r8, fp, sp, lr}^ │ │ │ │ ldmvs r8!, {r2, r8, sp} │ │ │ │ @ instruction: 0xf844f000 │ │ │ │ - bcs 1948c8 │ │ │ │ - bcs 110c50 │ │ │ │ + bcs 1948c0 │ │ │ │ + bcs 110c48 │ │ │ │ ldclvs 8, cr13, [r8], #44 @ 0x2c │ │ │ │ vmax.s8 q10, , q5 │ │ │ │ - vaddw.s8 q11, q8, d4 │ │ │ │ + vbic.i32 q11, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ @ instruction: 0xe761ffd9 │ │ │ │ - bcs 69464 │ │ │ │ + bcs 6945c │ │ │ │ @ instruction: 0x461cd8f3 │ │ │ │ - blcs 358b4 <__time64@plt+0x245cc> │ │ │ │ + blcs 358ac <__time64@plt+0x245c4> │ │ │ │ stmdbvs r0!, {r0, r1, r3, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ - blx 16d8c44 │ │ │ │ - teqpvs ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ + blx 16d8c3c │ │ │ │ + teqpvs r4, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ strmi r4, [r5], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7ff4640 │ │ │ │ ldmvs fp!, {r0, r1, r2, r7, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ vand d27, d25, d27 │ │ │ │ - vorr.i32 q11, #0 @ 0x00000000 │ │ │ │ + vmla.f d22, d0, d0[2] │ │ │ │ strtmi r0, [sl], -r2, lsl #2 │ │ │ │ @ instruction: 0xf7ff4640 │ │ │ │ stmdbvs r3!, {r0, r2, r3, r4, r5, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf43f42ab │ │ │ │ strtmi sl, [r8], -r1, asr #30 │ │ │ │ - stmib lr, {r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmib r2, {r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x4640e73c │ │ │ │ - msrvs (UNDEF: 100), r9 │ │ │ │ + cmppvs ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2l 7, cr15, [lr, #-1020]! @ 0xfffffc04 │ │ │ │ @ instruction: 0x4640e734 │ │ │ │ - msrvs (UNDEF: 100), r9 │ │ │ │ + cmppvs ip, r9, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2l 7, cr15, [r6, #-1020]! @ 0xfffffc04 │ │ │ │ svclt 0x0000e7e7 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ ldrmi r4, [sp], -r6, lsl #12 │ │ │ │ svcge 0x0004b08b │ │ │ │ @ instruction: 0xf897460c │ │ │ │ @ instruction: 0xf8d79044 │ │ │ │ @ instruction: 0xf8d78048 │ │ │ │ @ instruction: 0xb3a9a04c │ │ │ │ addsmi r6, r3, #9109504 @ 0x8b0000 │ │ │ │ @ instruction: 0xf8d8d055 │ │ │ │ - blcs 1e6cd0 │ │ │ │ + blcs 1e6cc8 │ │ │ │ movwcs sp, #79 @ 0x4f │ │ │ │ @ instruction: 0x46284652 │ │ │ │ - msrmi R8_fiq, r8 │ │ │ │ + msrmi R8_usr, r8 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2l 0, cr15, [lr], #48 @ 0x30 │ │ │ │ @ instruction: 0xf0203008 │ │ │ │ @ instruction: 0xf6480007 │ │ │ │ - vaddw.s8 q10, q0, d24 │ │ │ │ - bl feb5b0fc │ │ │ │ + vaddw.s8 q10, q0, d16 │ │ │ │ + bl feb5b0f4 │ │ │ │ strtmi r0, [r8], -r0, lsl #26 │ │ │ │ streq pc, [r0, #1600] @ 0x640 │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ movwcs r4, #1618 @ 0x652 │ │ │ │ ldceq 1, cr15, [r0], {13} │ │ │ │ andgt pc, r0, r5, asr #17 │ │ │ │ stc2l 0, cr15, [lr], #48 @ 0x30 │ │ │ │ @@ -9870,23 +9868,23 @@ │ │ │ │ ldrtmi r4, [r0], -r2, asr #12 │ │ │ │ strpl lr, [r0], #-2509 @ 0xfffff633 │ │ │ │ ldc2l 7, cr15, [ip, #1020] @ 0x3fc │ │ │ │ ssatmi r3, #30, ip, lsl #14 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ bicle r2, ip, r7, lsl #22 │ │ │ │ - bleq fe05863c │ │ │ │ - bleq 197840 │ │ │ │ + bleq fe058634 │ │ │ │ + bleq 197838 │ │ │ │ ldrbmi r2, [r2], -r0, lsl #6 │ │ │ │ @ instruction: 0xf6484628 │ │ │ │ - vaddw.s8 q10, q0, d24 │ │ │ │ + vaddw.s8 q10, q0, d16 │ │ │ │ @ instruction: 0xf00c0102 │ │ │ │ @ instruction: 0x3008fcb7 │ │ │ │ andeq pc, r7, r0, lsr #32 │ │ │ │ - msrmi R8_fiq, r8 │ │ │ │ + msrmi R8_usr, r8 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ vstreq d14, [r0, #-692] @ 0xfffffd4c │ │ │ │ @ instruction: 0x46284652 │ │ │ │ stcge 3, cr2, [r4, #-0] │ │ │ │ andpl pc, r0, fp, asr #17 │ │ │ │ strcs lr, [r0], #-1996 @ 0xfffff834 │ │ │ │ strmi lr, [lr], r0, ror #15 │ │ │ │ @@ -9895,570 +9893,570 @@ │ │ │ │ ldm lr!, {r0, r2, r8, r9, fp} │ │ │ │ stmia ip!, {r0, r1, r2, r3} │ │ │ │ movwcs r0, #15 │ │ │ │ @ instruction: 0xf8c74652 │ │ │ │ ldm lr, {r3, pc} │ │ │ │ stm ip, {r0, r1} │ │ │ │ stmdavs r0!, {r0, r1}^ │ │ │ │ - msrmi R8_fiq, r8 │ │ │ │ + msrmi R8_usr, r8 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2 0, cr15, [ip], {12} │ │ │ │ movweq pc, #33024 @ 0x8100 @ │ │ │ │ movweq pc, #28707 @ 0x7023 @ │ │ │ │ - bl feb74f34 │ │ │ │ + bl feb74f2c │ │ │ │ ldrbmi r0, [r2], -r3, lsl #26 │ │ │ │ @ instruction: 0xf6482300 │ │ │ │ - vaddw.s8 q10, q0, d24 │ │ │ │ + vaddw.s8 q10, q0, d16 │ │ │ │ stcge 1, cr0, [r4], {2} │ │ │ │ andmi pc, r0, fp, asr #17 │ │ │ │ ldc2 0, cr15, [r0], {12} │ │ │ │ rsbsvs r4, r8, ip, lsr r6 │ │ │ │ svclt 0x0000e7b6 │ │ │ │ umaalcc pc, r9, r1, r8 @ │ │ │ │ addlt fp, r3, r0, lsr r5 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ stmdavs r3, {r0, r3, r7, pc} │ │ │ │ - blcs 2ac618 │ │ │ │ + blcs 2ac610 │ │ │ │ ldm pc, {r0, r1, r5, fp, ip, lr, pc}^ @ │ │ │ │ svchi 0x008ff003 │ │ │ │ strtcs r2, [r4], #-1058 @ 0xfffffbde │ │ │ │ strcs r8, [r6], #-3876 @ 0xfffff0dc │ │ │ │ ldmib r1, {r3, r6}^ │ │ │ │ stmvs r8, {r3, r9, ip, sp} │ │ │ │ - msrvc (UNDEF: 108), r9 │ │ │ │ + msrvc (UNDEF: 100), r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ vcgt.s8 d25, d10, d0 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf7ff0302 │ │ │ │ stmdbvs r5!, {r0, r2, r3, r5, r7, sl, fp, ip, sp, lr, pc} │ │ │ │ vpmax.s8 q11, q5, q9 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ stmiavs r0!, {r1, r8, r9} │ │ │ │ mvnsvc pc, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ff9500 │ │ │ │ mullt r3, pc, ip @ │ │ │ │ ldmib r1, {r4, r5, r8, sl, fp, ip, sp, pc}^ │ │ │ │ stmvs r8, {r3, r9, ip, sp} │ │ │ │ - msrvc (UNDEF: 108), r9 │ │ │ │ + msrvc (UNDEF: 100), r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ vcgt.s8 d25, d10, d0 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf7ff0302 │ │ │ │ @ instruction: 0xf894fc8f │ │ │ │ stmiavs r0!, {r1, r3, r6, ip, sp} │ │ │ │ stmdbvs r5!, {r1, r5, r6, r9, fp, sp, lr} │ │ │ │ eorsle r2, ip, r0, lsl #22 │ │ │ │ vmla.i8 q11, q13, │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ stmib sp, {r1, r8, r9}^ │ │ │ │ vrhadd.s8 d21, d9, d0 │ │ │ │ - vsra.s64 d23, d0, #64 │ │ │ │ + vaddw.s8 , q8, d8 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ andlt pc, r3, fp, ror ip @ │ │ │ │ ldmib r1, {r4, r5, r8, sl, fp, ip, sp, pc}^ │ │ │ │ stmvs r8, {r3, r9, ip, sp} │ │ │ │ - msrvc (UNDEF: 108), r9 │ │ │ │ + msrvc (UNDEF: 100), r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ vcgt.s8 d25, d10, d0 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf7ff0302 │ │ │ │ @ instruction: 0xf894fc6b │ │ │ │ stmiavs r0!, {r3, r6, ip, sp} │ │ │ │ stmdbvs r4!, {r1, r5, r6, r9, fp, sp, lr} │ │ │ │ strls fp, [r0], #-355 @ 0xfffffe9d │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - @ instruction: 0x71b4f249 │ │ │ │ + @ instruction: 0x71acf249 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mrrc2 7, 15, pc, sl, cr15 @ │ │ │ │ ldclt 0, cr11, [r0, #-12]! │ │ │ │ vshl.s8 d25, d0, d10 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ vcgt.s8 d16, d9, d2 │ │ │ │ - vsra.s64 , q2, #64 │ │ │ │ + vmla.f d23, d16, d0[3] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ andlt pc, r3, sp, asr #24 │ │ │ │ strls fp, [r0, #-3376] @ 0xfffff2d0 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - @ instruction: 0x71b4f249 │ │ │ │ + @ instruction: 0x71acf249 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mcrr2 7, 15, pc, r0, cr15 @ │ │ │ │ ldclt 0, cr11, [r0, #-12]! │ │ │ │ - subvc pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ + subvc pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ teqpvc r3, r0, asr #12 @ p-variant is OBSOLETE │ │ │ │ - blx ff7d8ee4 │ │ │ │ - subvc pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ + blx ff8d8edc │ │ │ │ + subvc pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ cmppvc sp, r0, asr #12 @ p-variant is OBSOLETE │ │ │ │ - blx ff4d8efc │ │ │ │ + blx ff5d8ef4 │ │ │ │ @ instruction: 0x460cb530 │ │ │ │ addlt r6, r3, r3, lsl #16 │ │ │ │ ldmdale r8, {r1, r3, r8, r9, fp, sp} │ │ │ │ @ instruction: 0xf003e8df │ │ │ │ ldreq r4, [r7], -sl, asr #20 │ │ │ │ - bmi 19c754 │ │ │ │ + bmi 19c74c │ │ │ │ andseq r0, r9, r7, lsl r6 │ │ │ │ umaalcc pc, sl, r1, r8 @ │ │ │ │ stmdbvs r5!, {r0, r1, r3, r4, r5, r6, r8, r9, fp, ip, sp, pc} │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ stmiavs r0!, {r1, r5, r6, r9, fp, sp, lr} │ │ │ │ - @ instruction: 0x71b4f249 │ │ │ │ + @ instruction: 0x71acf249 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ff9500 │ │ │ │ andlt pc, r3, r7, lsl #24 │ │ │ │ @ instruction: 0xf891bd30 │ │ │ │ stmvs r8, {r3, r6, ip, sp} │ │ │ │ stmdbvs ip, {r1, r3, r6, r9, fp, sp, lr} │ │ │ │ strls fp, [r0], #-355 @ 0xfffffe9d │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - @ instruction: 0x71b4f249 │ │ │ │ + @ instruction: 0x71acf249 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx ffd58f86 │ │ │ │ + blx ffd58f7e │ │ │ │ ldclt 0, cr11, [r0, #-12]! │ │ │ │ vshl.s8 d25, d0, d10 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ vcgt.s8 d16, d9, d2 │ │ │ │ - vsra.s64 , q2, #64 │ │ │ │ + vmla.f d23, d16, d0[3] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ andlt pc, r3, r7, ror #23 │ │ │ │ stmdbvs r3!, {r4, r5, r8, sl, fp, ip, sp, pc} │ │ │ │ - bvs 18b56d0 │ │ │ │ + bvs 18b56c8 │ │ │ │ smlabtcc r0, sp, r9, lr │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - orrsvc pc, r0, r9, asr #4 │ │ │ │ + orrvc pc, r8, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ff68a0 │ │ │ │ sbfx pc, r5, #23, #31 │ │ │ │ - eoreq pc, ip, #76546048 @ 0x4900000 │ │ │ │ + eoreq pc, r4, #76546048 @ 0x4900000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ mvnsvs pc, r0, asr #12 │ │ │ │ - blx 1d58fb8 │ │ │ │ + blx 1e58fb0 │ │ │ │ @ instruction: 0x4617b5f8 │ │ │ │ svcne 0x001a680b │ │ │ │ - blcs 69c10 │ │ │ │ - bcs 8ae10 │ │ │ │ + blcs 69c08 │ │ │ │ + bcs 8ae08 │ │ │ │ @ instruction: 0x460cd817 │ │ │ │ stmdbvs r8, {r1, r2, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf884f7fd │ │ │ │ @ instruction: 0x4603463a │ │ │ │ @ instruction: 0xf6494605 │ │ │ │ - vbic.i32 q8, #0 @ 0x00000000 │ │ │ │ + vmla.f d16, d0, d0[6] │ │ │ │ ldrtmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx fec5900e │ │ │ │ + blx fec59006 │ │ │ │ adcmi r6, fp, #1622016 @ 0x18c000 │ │ │ │ strtmi sp, [r8], -r4 │ │ │ │ ldrhtmi lr, [r8], #141 @ 0x8d │ │ │ │ - svclt 0x00fef7f5 │ │ │ │ + stmdalt r2, {r1, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf649bdf8 │ │ │ │ - vmov.i32 q8, #1024 @ 0x00000400 │ │ │ │ + vmlal.s q8, d0, d0[3] │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf6400002 │ │ │ │ @ instruction: 0xf7f65128 │ │ │ │ - svclt 0x0000fa47 │ │ │ │ + svclt 0x0000fa4b │ │ │ │ strmi r6, [ip], fp, lsl #16 │ │ │ │ @ instruction: 0x4604b510 │ │ │ │ - bcs 222ab0 │ │ │ │ + bcs 222aa8 │ │ │ │ ldm pc, {r0, r1, r4, r6, fp, ip, lr, pc}^ @ │ │ │ │ eorscc pc, sl, #2 │ │ │ │ strcs r0, [r5, #-1285]! @ 0xfffffafb │ │ │ │ andeq r0, r5, r2, asr r5 │ │ │ │ suble r2, r5, r4, lsl #22 │ │ │ │ and r4, r3, r2, ror #12 │ │ │ │ ldmdavs r3, {r1, r4, r6, r7, r9, fp, sp, lr} │ │ │ │ eorsle r2, pc, r4, lsl #22 │ │ │ │ rscsle r2, r9, r9, lsl #22 │ │ │ │ - addeq pc, r4, #76546048 @ 0x4900000 │ │ │ │ + rsbseq pc, ip, #76546048 @ 0x4900000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - bicmi pc, r4, sl, asr #4 │ │ │ │ + @ instruction: 0x41bcf24a │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ svclt 0x00182b05 │ │ │ │ strtmi r4, [r0], -sl, lsl #12 │ │ │ │ - orreq pc, ip, r9, asr #12 │ │ │ │ + orreq pc, r4, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0x3014f8dc │ │ │ │ @ instruction: 0x4010e8bd │ │ │ │ - bllt 1b59094 │ │ │ │ + bllt 1b5908c │ │ │ │ @ instruction: 0x1014f8dc │ │ │ │ @ instruction: 0xffcef7ff │ │ │ │ @ instruction: 0xf64a4620 │ │ │ │ - vaddw.s8 q11, q0, d12 │ │ │ │ + vaddw.s8 q11, q0, d4 │ │ │ │ pop {r1, r8} │ │ │ │ @ instruction: 0xf7ff4010 │ │ │ │ @ instruction: 0xf649bb5f │ │ │ │ - vaddw.s8 q8, q8, d24 │ │ │ │ + vaddw.s8 q8, q8, d16 │ │ │ │ pop {r1, r8} │ │ │ │ @ instruction: 0xf7ff4010 │ │ │ │ @ instruction: 0xf89cbb57 │ │ │ │ teqlt fp, r4, lsl r0 │ │ │ │ - orrseq pc, r4, r9, asr #12 │ │ │ │ + orreq pc, ip, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0x4010e8bd │ │ │ │ - bllt 13590d4 │ │ │ │ - asreq pc, r9, #12 @ │ │ │ │ + bllt 13590cc │ │ │ │ + orrseq pc, r8, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0x4010e8bd │ │ │ │ - bllt 11590e4 │ │ │ │ - rsbseq pc, ip, #76546048 @ 0x4900000 │ │ │ │ + bllt 11590dc │ │ │ │ + rsbseq pc, r4, #76546048 @ 0x4900000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ @ instruction: 0xf649e7c7 │ │ │ │ - vrshr.s64 d16, d24, #64 │ │ │ │ + vrshr.s64 d16, d16, #64 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf6400002 │ │ │ │ @ instruction: 0xf7f65116 │ │ │ │ - svclt 0x0000f9df │ │ │ │ + svclt 0x0000f9e3 │ │ │ │ push {r0, r1, r3, fp, sp, lr} │ │ │ │ @ instruction: 0x469041f0 │ │ │ │ - blcc 262d80 │ │ │ │ - blcs 87324 │ │ │ │ - bcs 8af40 │ │ │ │ + blcc 262d78 │ │ │ │ + blcs 8731c │ │ │ │ + bcs 8af38 │ │ │ │ addhi pc, sl, r0, lsl #4 │ │ │ │ strmi r6, [sp], -ip, asr #20 │ │ │ │ cmnlt ip, r7, lsl #12 │ │ │ │ - strvc pc, [ip], r8, asr #12 │ │ │ │ + strvc pc, [r4], r8, asr #12 │ │ │ │ streq pc, [r2], -r0, asr #5 │ │ │ │ stmdavs r4!, {r0, sp, lr, pc} │ │ │ │ stmdavs r0!, {r2, r4, r5, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7f54631 │ │ │ │ - stmdacs r0, {r2, r4, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r3, r4, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ stmiavs r4!, {r0, r1, r2, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - blcs 353c0 <__time64@plt+0x240d8> │ │ │ │ + blcs 353b8 <__time64@plt+0x240d0> │ │ │ │ @ instruction: 0xf8d8d155 │ │ │ │ strtmi r3, [fp], #-24 @ 0xffffffe8 │ │ │ │ mlascs ip, r3, r8, pc @ │ │ │ │ andlt fp, r2, r2, lsl r1 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ ldrtmi r2, [r8], -r1, lsl #4 │ │ │ │ eorscs pc, ip, r3, lsl #17 │ │ │ │ - msrne R8_usr, r9 │ │ │ │ + tstpne r8, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx ffed9178 │ │ │ │ + blx ffed9170 │ │ │ │ ldrdcs pc, [r0], -r8 │ │ │ │ @ instruction: 0xf6494638 │ │ │ │ - vaddw.s8 , q0, d24 │ │ │ │ + vaddw.s8 , q0, d16 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ @ instruction: 0x4629faf1 │ │ │ │ @ instruction: 0xf7ff4638 │ │ │ │ shsaxmi pc, r8, r3 @ │ │ │ │ - teqpne r4, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + msrne R12_fiq, r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx ff9d91a0 │ │ │ │ + blx ff9d9198 │ │ │ │ vmin.s8 d20, d11, d24 │ │ │ │ - vorr.i32 d21, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 , q0, d12 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ @ instruction: 0xf649fadf │ │ │ │ - vbic.i32 d17, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d17, #4 @ 0x00000004 │ │ │ │ ldrtmi r0, [r8], -r2, lsl #2 │ │ │ │ - blx ff6591bc │ │ │ │ + blx ff6591b4 │ │ │ │ @ instruction: 0xf8d8b1b4 │ │ │ │ strtmi r2, [r1], -r0 │ │ │ │ @ instruction: 0xf7ff4638 │ │ │ │ ldrtmi pc, [r8], -r9, lsl #30 @ │ │ │ │ - cmppne ip, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + cmppne r4, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx ff2d91d8 │ │ │ │ + blx ff2d91d0 │ │ │ │ vmin.s8 d20, d10, d24 │ │ │ │ - vmla.f d23, d16, d0[6] │ │ │ │ + vmla.f d23, d16, d0[4] │ │ │ │ andlt r0, r2, r2, lsl #2 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - blt ff0591ec │ │ │ │ - blvs b6caa4 │ │ │ │ + blt ff0591e4 │ │ │ │ + blvs b6ca9c │ │ │ │ rscle r2, r4, r0, lsl #26 │ │ │ │ - blvs b6caac │ │ │ │ + blvs b6caa4 │ │ │ │ mvnsle r2, r0, lsl #26 │ │ │ │ vaba.s8 q15, q8, │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ @ instruction: 0xf6480305 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ ldmdavs lr, {r1} │ │ │ │ ldc2l 7, cr15, [ip, #-1008] @ 0xfffffc10 │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ movwls r4, #5634 @ 0x1602 │ │ │ │ @ instruction: 0xf6494630 │ │ │ │ - vmla.f d16, d16, d0[7] │ │ │ │ + vmla.f d16, d16, d0[5] │ │ │ │ stmdbvs lr!, {r1, r8}^ │ │ │ │ movtpl pc, #17984 @ 0x4640 @ │ │ │ │ @ instruction: 0xf7f59600 │ │ │ │ - @ instruction: 0xe78eefbc │ │ │ │ - sbceq pc, r8, #76546048 @ 0x4900000 │ │ │ │ + str lr, [lr, r0, asr #31] │ │ │ │ + sbceq pc, r0, #76546048 @ 0x4900000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ teqppl r2, r0, asr #12 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0xf93cf7f6 │ │ │ │ + @ instruction: 0xf940f7f6 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stmdavc sl, {r4, r7, r9, sl, lr} │ │ │ │ @ instruction: 0xb322b082 │ │ │ │ - ldrbne pc, [ip, -r9, asr #12] @ │ │ │ │ + ldrbne pc, [r4, -r9, asr #12] @ │ │ │ │ streq pc, [r2, -r0, asr #5] │ │ │ │ strmi r4, [r6], -sp, lsl #12 │ │ │ │ andle r2, r8, r5, lsr #20 │ │ │ │ @ instruction: 0x463968b0 │ │ │ │ - blx 1fd9270 │ │ │ │ + blx 1fd9268 │ │ │ │ @ instruction: 0xb1b2786a │ │ │ │ - bcs 968680 │ │ │ │ + bcs 968678 │ │ │ │ stmdavc fp!, {r1, r2, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ andsle r2, lr, r1, ror #22 │ │ │ │ - blcs c512d0 │ │ │ │ - blcs c8f394 │ │ │ │ + blcs c512c8 │ │ │ │ + blcs c8f38c │ │ │ │ @ instruction: 0xf649d135 │ │ │ │ - vmla.f d17, d0, d0[4] │ │ │ │ + vorr.i32 , #8 @ 0x00000008 │ │ │ │ ldmibvs r2!, {r1, r8} │ │ │ │ @ instruction: 0xf7ff68b0 │ │ │ │ stmiavc sl!, {r0, r3, r5, r6, r9, fp, ip, sp, lr, pc} │ │ │ │ - bcs 286ac <__time64@plt+0x173c4> │ │ │ │ + bcs 286a4 <__time64@plt+0x173bc> │ │ │ │ andlt sp, r2, r0, ror #3 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ @ instruction: 0xd1242b68 │ │ │ │ @ instruction: 0xf64969f2 │ │ │ │ - vmla.f d17, d0, d0[4] │ │ │ │ + vorr.i32 , #8 @ 0x00000008 │ │ │ │ ldmvs r0!, {r1, r8} │ │ │ │ - blx 16592bc │ │ │ │ + blx 16592b4 │ │ │ │ ldmdbvs r4!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ @ instruction: 0xf7f54620 │ │ │ │ - stmdane r2!, {r2, r5, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdane r2!, {r3, r5, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ stccc 8, cr15, [r1], {18} │ │ │ │ tstle sl, sp, asr fp │ │ │ │ - blcs 16f9324 │ │ │ │ + blcs 16f931c │ │ │ │ @ instruction: 0xf812d023 │ │ │ │ - blcs 16ea6e4 │ │ │ │ + blcs 16ea6dc │ │ │ │ @ instruction: 0xf812d1fb │ │ │ │ - blcs 176a2ec │ │ │ │ + blcs 176a2e4 │ │ │ │ ldmvs r0!, {r2, r4, r5, r6, r7, ip, lr, pc} │ │ │ │ - cmnpeq ip, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmnpeq r4, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx f592f4 │ │ │ │ + blx f592ec │ │ │ │ movwls lr, #2001 @ 0x7d1 │ │ │ │ @ instruction: 0x23254642 │ │ │ │ - msrne (UNDEF: 104), r9 │ │ │ │ + msrne (UNDEF: 96), r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fd6af0 │ │ │ │ strb pc, [r6, pc, ror #24] @ │ │ │ │ @ instruction: 0xf6496972 │ │ │ │ - vmla.f d17, d0, d0[4] │ │ │ │ + vorr.i32 , #8 @ 0x00000008 │ │ │ │ ldmvs r0!, {r1, r8} │ │ │ │ - blx a5931c │ │ │ │ + blx a59314 │ │ │ │ @ instruction: 0xf812e7bd │ │ │ │ - blcs 176a32c │ │ │ │ + blcs 176a324 │ │ │ │ ubfx sp, pc, #3, #31 │ │ │ │ @ instruction: 0x4605b570 │ │ │ │ stmdbcs r0, {r2, r3, r9, sl, lr} │ │ │ │ stmdavs r3!, {r0, r3, r4, r5, ip, lr, pc} │ │ │ │ stmdale r2!, {r1, r3, r8, r9, fp, sp} │ │ │ │ @ instruction: 0xf003e8df │ │ │ │ cdpcc 7, 2, cr4, cr2, cr7, {2} │ │ │ │ @ instruction: 0x532b0606 │ │ │ │ andeq r0, r6, r7, asr #12 │ │ │ │ - blvs 92cbe8 │ │ │ │ + blvs 92cbe0 │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ @ instruction: 0xf7fc6970 │ │ │ │ @ instruction: 0x4604fed5 │ │ │ │ - svc 0x0018f7f5 │ │ │ │ + svc 0x001cf7f5 │ │ │ │ strmi r4, [r2], -r3, lsr #12 │ │ │ │ - @ instruction: 0x11b4f649 │ │ │ │ + @ instruction: 0x11acf649 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ ldmdbvs r3!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, fp, ip, sp, lr, pc}^ │ │ │ │ andle r4, r4, r3, lsr #5 │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7f54070 │ │ │ │ - ldcllt 14, cr11, [r0, #-308]! @ 0xfffffecc │ │ │ │ + ldcllt 14, cr11, [r0, #-324]! @ 0xfffffebc │ │ │ │ vmax.s8 d20, d12, d24 │ │ │ │ - vbic.i32 d19, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d19, #4 @ 0x00000004 │ │ │ │ pop {r1, r8} │ │ │ │ @ instruction: 0xf7ff4070 │ │ │ │ strtmi fp, [r8], -sp, ror #19 │ │ │ │ - @ instruction: 0x11acf649 │ │ │ │ + @ instruction: 0x11a4f649 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf9e6f7ff │ │ │ │ @ instruction: 0x2c006964 │ │ │ │ strtmi sp, [r8], -r5, asr #3 │ │ │ │ - orrsne pc, r0, r9, asr #12 │ │ │ │ + orrne pc, r8, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrhtmi lr, [r0], #-141 @ 0xffffff73 │ │ │ │ ldmiblt sl, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf6494628 │ │ │ │ - vsra.s64 d17, d16, #64 │ │ │ │ + vaddw.s8 , q8, d24 │ │ │ │ pop {r1, r8} │ │ │ │ @ instruction: 0xf7ff4070 │ │ │ │ @ instruction: 0xf649b9d1 │ │ │ │ - vrshr.s64 d17, d4, #64 │ │ │ │ + vsubl.s8 , d16, d12 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf6400002 │ │ │ │ @ instruction: 0xf7f611c6 │ │ │ │ - @ instruction: 0xf649f871 │ │ │ │ - vrshr.s64 d17, d4, #64 │ │ │ │ + @ instruction: 0xf649f875 │ │ │ │ + vsubl.s8 , d16, d12 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf6400002 │ │ │ │ @ instruction: 0xf7f611e3 │ │ │ │ - svclt 0x0000f865 │ │ │ │ + svclt 0x0000f869 │ │ │ │ @ instruction: 0x4605b5f0 │ │ │ │ stmdavs lr, {r0, r1, fp, sp, lr}^ │ │ │ │ strmi fp, [ip], -r5, lsl #1 │ │ │ │ ldmdale r8, {r1, r3, r8, r9, fp, sp}^ │ │ │ │ @ instruction: 0xf013e8df │ │ │ │ ldrshteq r0, [r6], #6 │ │ │ │ subseq r0, r9, r7, asr r0 │ │ │ │ subseq r0, r9, r9, asr r0 │ │ │ │ rsceq r0, sl, fp │ │ │ │ subseq r0, r9, r7, asr r0 │ │ │ │ stmdbvs fp, {r0, r3, r4, r6} │ │ │ │ movwls r6, #6730 @ 0x1a4a │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0x910068b1 │ │ │ │ - bicsne pc, r8, r9, asr #12 │ │ │ │ + bicsne pc, r0, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ff68a0 │ │ │ │ ldmdavs r3!, {r0, r1, r4, r7, r8, fp, ip, sp, lr, pc}^ │ │ │ │ stmdbvs fp!, {r0, r1, r5, r6, r7, r8, ip, sp, pc}^ │ │ │ │ ldmdavs fp, {r5, r7, fp, sp, lr} │ │ │ │ @ instruction: 0xf0002b02 │ │ │ │ - bvs 8bb728 │ │ │ │ + bvs 8bb720 │ │ │ │ mvnne pc, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf984f7ff │ │ │ │ stmiavs r0!, {r0, r1, r5, r7, r8, r9, fp, sp, lr} │ │ │ │ - blcs 35638 <__time64@plt+0x24350> │ │ │ │ + blcs 35630 <__time64@plt+0x24348> │ │ │ │ adcshi pc, r2, r0 │ │ │ │ - orrsvc pc, r4, sl, asr #4 │ │ │ │ + orrvc pc, ip, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf978f7ff │ │ │ │ stmiavs r0!, {r0, r5, r7, r8, r9, fp, sp, lr} │ │ │ │ @ instruction: 0xff52f7ff │ │ │ │ @ instruction: 0xf64968a0 │ │ │ │ - vaddw.s8 q9, q0, d20 │ │ │ │ + vorr.i32 d18, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ - blvs ff919a4c │ │ │ │ + blvs ff919a44 │ │ │ │ ldmdbvs r1!, {r0, r1, r3, r4, r7, r8, ip, sp, pc} │ │ │ │ - bvs 8c7ac4 │ │ │ │ + bvs 8c7abc │ │ │ │ stmib sp, {r0, r2, r5, r8, fp, sp, lr}^ │ │ │ │ vcgt.s8 d18, d10, d2 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ - bvs 189c0b8 │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ + bvs 189c0b0 │ │ │ │ stmib sp, {r5, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf6491500 │ │ │ │ - vsra.s64 , q14, #64 │ │ │ │ + vsra.s64 , q10, #64 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ andlt pc, r5, r7, asr r9 @ │ │ │ │ stmvs r8, {r4, r5, r6, r7, r8, sl, fp, ip, sp, pc} │ │ │ │ - bvs 12a60f4 │ │ │ │ + bvs 12a60ec │ │ │ │ tstle r0, r1, lsr r8 │ │ │ │ umaalcc pc, r8, r4, r8 @ │ │ │ │ stmdbvs r4!, {r0, r1, r3, r5, r6, r8, fp, ip, sp, pc} │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ strne lr, [r0], #-2509 @ 0xfffff633 │ │ │ │ - tstpcs r4, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpcs ip, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf940f7ff │ │ │ │ smlattls r0, r7, r7, lr │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - msrcs R8_fiq, r9 │ │ │ │ + msrcs R8_usr, r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf934f7ff │ │ │ │ strtmi r6, [r9], -r0, lsr #17 │ │ │ │ @ instruction: 0xff0ef7ff │ │ │ │ - blcs f55c0 │ │ │ │ + blcs f55b8 │ │ │ │ @ instruction: 0xf649d12c │ │ │ │ - vbic.i32 d18, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 q9, q0, d28 │ │ │ │ ldmdavs r0!, {r1, r8} │ │ │ │ - stcl 7, cr15, [r2, #-980]! @ 0xfffffc2c │ │ │ │ + stcl 7, cr15, [r6, #-980]! @ 0xfffffc2c │ │ │ │ stmiavs r5!, {r5, r8, r9, fp, ip, sp, pc}^ │ │ │ │ vcge.s8 d27, d9, d5 │ │ │ │ - vqshl.s64 q10, q10, #0 │ │ │ │ + vqdmlsl.s q10, d16, d0[7] │ │ │ │ and r0, r1, r2, lsl #14 │ │ │ │ bicslt r6, sp, sp, lsr #16 │ │ │ │ - blcs 757e8 │ │ │ │ + blcs 757e0 │ │ │ │ stmdavs r8!, {r1, r3, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7f54639 │ │ │ │ - stmdacs r0, {r1, r4, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r4, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ stmiavs sp!, {r2, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ stmdbvs r2!, {r0, r2, r7, r8, ip, sp, pc} │ │ │ │ - teqpcs ip, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqpcs r4, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ff68a0 │ │ │ │ strtmi pc, [r9], -r9, lsl #18 │ │ │ │ vmax.s8 d20, d9, d16 │ │ │ │ - vrshr.s64 q10, q10, #64 │ │ │ │ + vmlal.s q10, d16, d0[7] │ │ │ │ @ instruction: 0xf7ff0202 │ │ │ │ and pc, r7, r1, ror lr @ │ │ │ │ - cmppcs r4, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqpcs ip, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stmiavs r0!, {r1, r5, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf8f8f7ff │ │ │ │ @ instruction: 0xf64968a0 │ │ │ │ - vaddw.s8 q9, q0, d20 │ │ │ │ + vorr.i32 d18, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ - blvs ff8d9954 │ │ │ │ + blvs ff8d994c │ │ │ │ addsle r2, r6, r0, lsl #20 │ │ │ │ @ instruction: 0x2d006935 │ │ │ │ stmdbvs r1!, {r0, r1, r4, r7, ip, lr, pc} │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ andne lr, r2, #3358720 @ 0x334000 │ │ │ │ @ instruction: 0xf6499101 │ │ │ │ - vsra.s64 , q14, #64 │ │ │ │ - bvs 189b9bc │ │ │ │ + vsra.s64 , q10, #64 │ │ │ │ + bvs 189b9b4 │ │ │ │ strls r6, [r0, #-2208] @ 0xfffff760 │ │ │ │ @ instruction: 0xf8daf7ff │ │ │ │ ldcllt 0, cr11, [r0, #20]! │ │ │ │ - mvnne pc, r9, asr #12 │ │ │ │ + bicsne pc, ip, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf8d2f7ff │ │ │ │ stmiavs r0!, {r0, r1, r5, r7, r8, r9, fp, sp, lr} │ │ │ │ - blcs 3579c <__time64@plt+0x244b4> │ │ │ │ + blcs 35794 <__time64@plt+0x244ac> │ │ │ │ svcge 0x004ef47f │ │ │ │ @ instruction: 0xf6496963 │ │ │ │ - vsra.s64 , q8, #64 │ │ │ │ + vmla.f d17, d16, d0[6] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ strb pc, [pc, -r5, asr #17] @ │ │ │ │ - adcsne pc, ip, #76546048 @ 0x4900000 │ │ │ │ + adcsne pc, r4, #76546048 @ 0x4900000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ bicsmi pc, r3, r0, asr #12 │ │ │ │ - @ instruction: 0xff64f7f5 │ │ │ │ - adcsne pc, ip, #76546048 @ 0x4900000 │ │ │ │ + @ instruction: 0xff68f7f5 │ │ │ │ + adcsne pc, r4, #76546048 @ 0x4900000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ cmnpmi fp, r0, asr #12 @ p-variant is OBSOLETE │ │ │ │ - @ instruction: 0xff58f7f5 │ │ │ │ + @ instruction: 0xff5cf7f5 │ │ │ │ stmdacs r0, {r3, r4, r5, r6, r7, r8, sl, ip, sp, pc} │ │ │ │ @ instruction: 0x460ed05d │ │ │ │ rsble r2, r6, r0, lsl #18 │ │ │ │ tstcs r4, r4, lsl #12 │ │ │ │ @ instruction: 0xf7fc2001 │ │ │ │ vpadd.i8 , q0, │ │ │ │ vrsra.s64 , q8, #64 │ │ │ │ strtmi r0, [r2], -r5, lsl #6 │ │ │ │ strmi r6, [r5], -r6, asr #32 │ │ │ │ - cmppcs r8, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + cmppcs r0, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ vpmin.s8 d22, d29, d12 │ │ │ │ - vmvn.i32 q8, #201326592 @ 0x0c000000 │ │ │ │ + vmvn.i32 q8, #67108864 @ 0x04000000 │ │ │ │ andvs r0, r4, r2, lsl #12 │ │ │ │ addsvs r4, r8, #11776 @ 0x2e00 │ │ │ │ @ instruction: 0xf88cf7ff │ │ │ │ strbeq pc, [ip, -r4, lsl #2] @ │ │ │ │ @ instruction: 0x46284631 │ │ │ │ svccs 0x0004f854 │ │ │ │ @ instruction: 0xf884f7ff │ │ │ │ @@ -10487,1442 +10485,1442 @@ │ │ │ │ @ instruction: 0x46284631 │ │ │ │ @ instruction: 0xf854f7ff │ │ │ │ ldrtmi r6, [r1], -r2, lsr #16 │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ adcsmi pc, ip, #5177344 @ 0x4f0000 │ │ │ │ strtmi sp, [r8], -r8, asr #3 │ │ │ │ @ instruction: 0xf649bdf8 │ │ │ │ - vmlal.s q9, d0, d0[3] │ │ │ │ + vmlal.s q9, d0, d0[1] │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7f5615a │ │ │ │ - @ instruction: 0xf649feeb │ │ │ │ - vmlal.s q9, d0, d0[3] │ │ │ │ + @ instruction: 0xf649feef │ │ │ │ + vmlal.s q9, d0, d0[1] │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7f5615b │ │ │ │ - svclt 0x0000fedf │ │ │ │ - muleq r2, r8, sp │ │ │ │ + svclt 0x0000fee3 │ │ │ │ + muleq r2, r0, sp │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ push {r0, r1, r3, r7, pc} │ │ │ │ vrecps.f32 q10, , q8 │ │ │ │ - vabdl.s8 , d0, d4 │ │ │ │ + vqshl.s64 q9, q14, #0 │ │ │ │ vabd.s8 d16, d10, d2 │ │ │ │ - vmul.f d20, d16, d0[1] │ │ │ │ + @ instruction: 0xf2c049bc │ │ │ │ @ instruction: 0xf6490902 │ │ │ │ - vmvn.i16 q9, #2048 @ 0x0800 │ │ │ │ + vmvn.i16 q9, #0 @ 0x0000 │ │ │ │ addlt r0, r3, r2, lsl #20 │ │ │ │ ldrmi r4, [r0], lr, lsl #12 │ │ │ │ - bvs 1b2cf50 │ │ │ │ + bvs 1b2cf48 │ │ │ │ ands fp, fp, r4, lsl r9 │ │ │ │ biclt r6, ip, r4, lsr #16 │ │ │ │ - blcs 759d4 │ │ │ │ + blcs 759cc │ │ │ │ stmdavs r0!, {r1, r3, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7f54639 │ │ │ │ - stmdacs r0, {r2, r3, r6, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r4, r6, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf8d4d1f4 │ │ │ │ @ instruction: 0xf1bbb00c │ │ │ │ andle r0, fp, r0, lsl #30 │ │ │ │ ldrdmi pc, [r0], -r8 │ │ │ │ ands fp, r2, r4, lsl r9 │ │ │ │ orrlt r6, r4, r4, ror #16 │ │ │ │ ldrbmi r6, [r9], -r0, lsr #16 │ │ │ │ - ldc 7, cr15, [sl], #-980 @ 0xfffffc2c │ │ │ │ + ldc 7, cr15, [lr], #-980 @ 0xfffffc2c │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ strbmi r6, [r2], -r8, ror #22 │ │ │ │ @ instruction: 0xf7ff4631 │ │ │ │ - blvs feb9b6a0 │ │ │ │ + blvs feb9b698 │ │ │ │ bicsle r2, r8, r0, lsl #26 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ strdcs r8, [r8, -r0] │ │ │ │ @ instruction: 0xf7fc2001 │ │ │ │ @ instruction: 0xf8cdfac7 │ │ │ │ ldrbmi fp, [r1], -r0 │ │ │ │ andlt pc, r0, r0, asr #17 │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ strbmi r6, [fp], -r3, asr #32 │ │ │ │ @ instruction: 0xf8c86a72 │ │ │ │ ldmvs r0!, {} @ │ │ │ │ @ instruction: 0xffdef7fe │ │ │ │ ldmvs r0!, {r1, r4, r5, r6, r9, fp, sp, lr} │ │ │ │ andcc r4, r2, #78643200 @ 0x4b00000 │ │ │ │ - orrcs pc, r8, r9, asr #12 │ │ │ │ + orrcs pc, r0, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fe6272 │ │ │ │ - bvs 1cdb718 │ │ │ │ + bvs 1cdb710 │ │ │ │ @ instruction: 0xf649696b │ │ │ │ - vsra.s64 d18, d0, #64 │ │ │ │ + vaddw.s8 q9, q8, d8 │ │ │ │ andcc r0, r2, #-2147483648 @ 0x80000000 │ │ │ │ stmib sp, {r1, r4, r5, r6, r9, sp, lr}^ │ │ │ │ strbmi r3, [fp], -r0, lsl #6 │ │ │ │ @ instruction: 0xf7fe68b0 │ │ │ │ ldmdbvs r4!, {r0, r2, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x46284631 │ │ │ │ - @ instruction: 0x23b8f649 │ │ │ │ + movscs pc, #76546048 @ 0x4900000 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0xf0006133 │ │ │ │ - bvs 1cd9868 │ │ │ │ + bvs 1cd9860 │ │ │ │ @ instruction: 0x464b68b0 │ │ │ │ teqvs r4, r2, lsl #20 │ │ │ │ @ instruction: 0xf6496272 │ │ │ │ - vmla.f d18, d16, d0[0] │ │ │ │ + vsra.s64 d18, d24, #64 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ strbmi pc, [fp], -pc, lsr #31 @ │ │ │ │ @ instruction: 0xf6496a72 │ │ │ │ - vmla.f d18, d16, d0[2] │ │ │ │ + vmla.f d18, d16, d0[0] │ │ │ │ ldmvs r0!, {r1, r8} │ │ │ │ @ instruction: 0xffa6f7fe │ │ │ │ - blcc b61f4 │ │ │ │ + blcc b61ec │ │ │ │ @ instruction: 0xe7a56273 │ │ │ │ svclt 0x00004770 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ - bicvc pc, r0, #72, 12 @ 0x4800000 │ │ │ │ + @ instruction: 0x73b8f648 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ vqadd.s8 d27, d25, d13 │ │ │ │ - vmvn.i32 q9, #3327 @ 0x00000cff │ │ │ │ + vmvn.i32 q9, #1279 @ 0x000004ff │ │ │ │ ldrmi r0, [r9], r2, lsl #24 │ │ │ │ strmi r4, [ip], r3, ror #13 │ │ │ │ - cdpcc 2, 0, cr15, cr4, cr9, {2} │ │ │ │ + cdpcs 2, 15, cr15, cr12, cr9, {2} │ │ │ │ cdpeq 2, 0, cr15, cr2, cr0, {6} │ │ │ │ @ instruction: 0xf8cd9009 │ │ │ │ @ instruction: 0xf8dce018 │ │ │ │ stccs 0, cr5, [r0, #-48] @ 0xffffffd0 │ │ │ │ strhi pc, [r7, #0]! │ │ │ │ @ instruction: 0xf6482200 │ │ │ │ - vsubhn.i16 d23, q8, q10 │ │ │ │ + @ instruction: 0xf2c0769c │ │ │ │ @ instruction: 0xf6480602 │ │ │ │ - vqshl.s64 d23, d8, #0 │ │ │ │ + vqshl.s64 d23, d0, #0 │ │ │ │ vabd.s8 d16, d9, d2 │ │ │ │ - @ instruction: 0xf2c03894 │ │ │ │ + vmlal.s8 , d16, d12 │ │ │ │ strtmi r0, [ip], -r2, lsl #16 │ │ │ │ andls r4, r7, #153092096 @ 0x9200000 │ │ │ │ andls r9, sp, #-1610612736 @ 0xa0000000 │ │ │ │ andcs lr, r4, #3358720 @ 0x334000 │ │ │ │ @ instruction: 0xf8cd950b │ │ │ │ eor ip, r4, r0, lsr #32 │ │ │ │ strtmi r4, [r8], -r1, asr #12 │ │ │ │ - bl fe9d9870 │ │ │ │ + bl fead9868 │ │ │ │ stmiavs r3!, {r3, r5, r8, fp, ip, sp, pc} │ │ │ │ svclt 0x00042b01 │ │ │ │ movwls r6, #55523 @ 0xd8e3 │ │ │ │ @ instruction: 0x4649d017 │ │ │ │ @ instruction: 0xf7f54628 │ │ │ │ - stmdblt r8!, {r2, r3, r4, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ - blcs f5b44 │ │ │ │ + stmdblt r8!, {r5, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ + blcs f5b3c │ │ │ │ stmiavs r3!, {r2, r8, r9, sl, fp, ip, sp, pc}^ │ │ │ │ andle r9, ip, r5, lsl #6 │ │ │ │ @ instruction: 0x46284659 │ │ │ │ - bl fe45989c │ │ │ │ + bl fe559894 │ │ │ │ stmdbls r6, {r3, r4, r5, r8, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f54628 │ │ │ │ - stmdacs r0, {r2, r3, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r4, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ stmiavs r3!, {r0, r1, r3, r6, r8, ip, lr, pc}^ │ │ │ │ stmdavs r4!, {r1, r3, r8, r9, ip, pc} │ │ │ │ stmdavs r5!, {r2, r4, r5, r7, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0x46284631 │ │ │ │ - bl fe0598bc │ │ │ │ + bl fe1598b4 │ │ │ │ stmiavs r3!, {r3, r5, r8, fp, ip, sp, pc} │ │ │ │ svclt 0x00042b01 │ │ │ │ movwls r6, #18659 @ 0x48e3 │ │ │ │ @ instruction: 0x4639d0f1 │ │ │ │ @ instruction: 0xf7f54628 │ │ │ │ - stmdacs r0, {r1, r2, r4, r5, r6, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r3, r4, r5, r6, r8, r9, fp, sp, lr, pc} │ │ │ │ stmdavs r4!, {r3, r6, r7, r8, ip, lr, pc} │ │ │ │ - beq 97a44 │ │ │ │ + beq 97a3c │ │ │ │ mvnle r2, r0, lsl #24 │ │ │ │ ldrdgt pc, [r0], -sp @ │ │ │ │ andne lr, r4, #3620864 @ 0x374000 │ │ │ │ ldrsbtcc pc, [r4], -ip @ │ │ │ │ - blcs 42d48 <__time64@plt+0x31a60> │ │ │ │ + blcs 42d40 <__time64@plt+0x31a58> │ │ │ │ strmi fp, [ip], -r8, lsl #30 │ │ │ │ ldmdavs r9, {r0, r3, r8, r9, fp, ip, pc} │ │ │ │ svceq 0x0000f1ba │ │ │ │ adchi pc, r8, r0 │ │ │ │ @ instruction: 0xf0402906 │ │ │ │ ldmdbvs fp, {r1, r3, r5, r6, r7, pc}^ │ │ │ │ svcne 0x0018681b │ │ │ │ - blcs 6a560 │ │ │ │ + blcs 6a558 │ │ │ │ stmdacs r1, {r3, r7, r8, r9, sl, fp, ip, sp, pc} │ │ │ │ rschi pc, r1, r0, lsl #4 │ │ │ │ - blcs 42564 <__time64@plt+0x3127c> │ │ │ │ + blcs 4255c <__time64@plt+0x31274> │ │ │ │ orrhi pc, r0, #0 │ │ │ │ stmdbcs sl, {r1, r3, r4, r7, r9, sl, lr} │ │ │ │ sbcshi pc, r6, r0, lsl #4 │ │ │ │ @ instruction: 0xf011e8df │ │ │ │ @ instruction: 0x07b307b3 │ │ │ │ addeq r0, r9, r9, lsl #1 │ │ │ │ rsceq r0, r5, r5, ror #1 │ │ │ │ rscseq r0, r0, #-402653183 @ 0xe8000001 │ │ │ │ sbcseq r0, fp, #137 @ 0x89 │ │ │ │ vhadd.s8 d16, d25, d9 │ │ │ │ - vbic.i32 d18, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d18, #4 @ 0x00000004 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - bl dd9950 │ │ │ │ + bl ed9948 │ │ │ │ adcle r2, ip, r0, lsl #16 │ │ │ │ - @ instruction: 0x71acf648 │ │ │ │ + @ instruction: 0x71a4f648 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f54628 │ │ │ │ - stmdacs r0, {r1, r2, r3, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r4, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf649d0a3 │ │ │ │ - vsra.s64 q9, q6, #64 │ │ │ │ + vsra.s64 q9, q2, #64 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - bl 959974 │ │ │ │ + bl a5996c │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ vqrshl.s8 d24, d5, d9 │ │ │ │ - vsra.s64 q9, q4, #64 │ │ │ │ + vsra.s64 q9, q0, #64 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - bl 6d9988 │ │ │ │ + bl 7d9980 │ │ │ │ addsle r2, r0, r0, lsl #16 │ │ │ │ mvnspl pc, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f54628 │ │ │ │ - stmdacs r0, {r1, r4, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r4, r8, r9, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf649d087 │ │ │ │ - vmla.f d18, d16, d0[5] │ │ │ │ + vsra.s64 q9, q6, #64 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - bl 2599ac │ │ │ │ + bl 3599a4 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0xf649af7e │ │ │ │ - vsra.s64 q9, q8, #64 │ │ │ │ + vmla.f d18, d16, d0[6] │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - b fffd99c0 │ │ │ │ + bl d99b8 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ vrecps.f32 q13, , q10 │ │ │ │ - vbic.i32 , #12 @ 0x0000000c │ │ │ │ + vbic.i32 , #4 @ 0x00000004 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - b ffd599d4 │ │ │ │ + b ffe599cc │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0xf649af6a │ │ │ │ - vaddw.s8 , q0, d0 │ │ │ │ + vsra.s64 q9, q12, #64 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - b ffad99e8 │ │ │ │ + b ffbd99e0 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0xf649af60 │ │ │ │ - vorr.i32 d19, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 , q0, d8 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - b ff8599fc │ │ │ │ + b ff9599f4 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0xf648af56 │ │ │ │ - vsra.s64 d23, d20, #64 │ │ │ │ + vaddw.s8 , q8, d28 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - b ff5d9a10 │ │ │ │ + b ff6d9a08 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ vmax.f32 q13, , q6 │ │ │ │ - vsra.s64 q10, q10, #64 │ │ │ │ + vmla.f d20, d16, d0[7] │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - b ff359a24 │ │ │ │ + b ff459a1c │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ - blls 247760 │ │ │ │ + blls 247758 │ │ │ │ @ instruction: 0xf649462a │ │ │ │ - vorr.i32 d19, #12 @ 0x0000000c │ │ │ │ - bvs ff61be6c │ │ │ │ + vorr.i32 d19, #4 @ 0x00000004 │ │ │ │ + bvs ff61be64 │ │ │ │ @ instruction: 0xf8c2f7fd │ │ │ │ @ instruction: 0x46e2e737 │ │ │ │ ldrdcc pc, [r0], -sl │ │ │ │ stmdals r9, {r0, r4, r6, r9, sl, lr} │ │ │ │ pop {r0, r2, r3, r4, ip, sp, pc} │ │ │ │ @ instruction: 0x47184ff0 │ │ │ │ - blcs 4269c <__time64@plt+0x313b4> │ │ │ │ + blcs 42694 <__time64@plt+0x313ac> │ │ │ │ svcge 0x0065f43f │ │ │ │ svclt 0x00182906 │ │ │ │ @ instruction: 0xf43f2903 │ │ │ │ @ instruction: 0xf649af60 │ │ │ │ - vmla.f d19, d0, d0[5] │ │ │ │ + vorr.i32 , #12 @ 0x0000000c │ │ │ │ strbtmi r0, [r2], r2, lsl #2 │ │ │ │ @ instruction: 0xf8dae03a │ │ │ │ vhadd.s8 d18, d10, d20 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vmla.f d21, d16, d0[0] │ │ │ │ + vsra.s64 d21, d24, #64 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf24afe5d │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf6490302 │ │ │ │ - vbic.i32 q11, #12 @ 0x0000000c │ │ │ │ + vbic.i32 q11, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ @ instruction: 0xf7fe0008 │ │ │ │ @ instruction: 0xf8dafe4f │ │ │ │ vhadd.s8 d18, d10, d20 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vmla.f d18, d16, d0[0] │ │ │ │ + vsra.s64 d18, d24, #64 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf8dafe41 │ │ │ │ - blcc a7b84 │ │ │ │ + blcc a7b7c │ │ │ │ eorcc pc, r4, sl, asr #17 │ │ │ │ - blcs 42718 <__time64@plt+0x31430> │ │ │ │ + blcs 42710 <__time64@plt+0x31428> │ │ │ │ ldrhi pc, [r8], #64 @ 0x40 │ │ │ │ pop {r0, r2, r3, r4, ip, sp, pc} │ │ │ │ @ instruction: 0xf6498ff0 │ │ │ │ - vbic.i32 d19, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 , q0, d28 │ │ │ │ strbtmi r0, [r2], r2, lsl #2 │ │ │ │ @ instruction: 0x2010f8da │ │ │ │ ldrdeq pc, [ip], -sl @ │ │ │ │ pop {r0, r2, r3, r4, ip, sp, pc} │ │ │ │ @ instruction: 0xf7fd4ff0 │ │ │ │ strbtmi fp, [r2], r5, ror #16 │ │ │ │ @ instruction: 0xf8da9106 │ │ │ │ - blls 263b6c │ │ │ │ + blls 263b64 │ │ │ │ @ instruction: 0xf8da9211 │ │ │ │ andsls r2, r8, #24 │ │ │ │ ldmibvs fp, {r1, r2, r9, fp, ip, pc} │ │ │ │ andeq pc, r5, #-2147483608 @ 0x80000028 │ │ │ │ @ instruction: 0x701cf8da │ │ │ │ @ instruction: 0xf282fab2 │ │ │ │ andls r0, pc, #1343488 @ 0x148000 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ stcls 5, cr8, [r9], {248} @ 0xf8 │ │ │ │ ldrsbtcc pc, [r0], -sl @ │ │ │ │ orrsmi r6, r3, #663552 @ 0xa2000 │ │ │ │ @ instruction: 0xf8dad010 │ │ │ │ @ instruction: 0xf649002c │ │ │ │ - vaddw.s8 , q0, d12 │ │ │ │ + vaddw.s8 , q0, d4 │ │ │ │ stmdbvs r2!, {r1, r8}^ │ │ │ │ @ instruction: 0xf840f7fd │ │ │ │ - cmpppl r0, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqppl r8, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ andseq pc, r8, r4, lsl #2 │ │ │ │ @ instruction: 0xf838f7fd │ │ │ │ - bvs 17827a4 │ │ │ │ + bvs 178279c │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ - blls 37d328 │ │ │ │ + blls 37d320 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ movwls r8, #54318 @ 0xd42e │ │ │ │ - blcs 35c40 <__time64@plt+0x24958> │ │ │ │ + blcs 35c38 <__time64@plt+0x24950> │ │ │ │ ldrhi pc, [r9], -r0 │ │ │ │ @ instruction: 0xf8ca9b11 │ │ │ │ - blls 1a7c10 │ │ │ │ + blls 1a7c08 │ │ │ │ andsvc pc, r8, sl, asr #17 │ │ │ │ @ instruction: 0xf0002b05 │ │ │ │ - blls 37d0ec │ │ │ │ + blls 37d0e4 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - blls 2bcc84 │ │ │ │ + blls 2bcc7c │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ @ instruction: 0xf8da8652 │ │ │ │ vhadd.s8 d18, d10, d20 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vaddw.s8 , q8, d4 │ │ │ │ + vbic.i32 , #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ stmdbls sp, {r0, r2, r3, r6, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ vmin.s8 q10, , q0 │ │ │ │ - vrshr.s64 d19, d4, #64 │ │ │ │ + vsubl.s8 , d16, d12 │ │ │ │ @ instruction: 0xf7ff0202 │ │ │ │ @ instruction: 0xf8dafb35 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vsra.s64 d21, d8, #64 │ │ │ │ + vsra.s64 d21, d0, #64 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf8dafdbd │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ vhadd.s8 d16, d10, d8 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ andcc r0, r2, #134217728 @ 0x8000000 │ │ │ │ - orrcs pc, r8, r9, asr #12 │ │ │ │ + orrcs pc, r0, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ eorcs pc, r4, sl, asr #17 │ │ │ │ stc2 7, cr15, [ip, #1016]! @ 0x3f8 │ │ │ │ movwls r9, #2826 @ 0xb0a │ │ │ │ - cmnpcs r8, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + cmnpcs r0, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ ldc2 7, cr15, [ip, #1016] @ 0x3f8 │ │ │ │ ldrdcc pc, [r4], -sl @ │ │ │ │ @ instruction: 0xf8ca3302 │ │ │ │ @ instruction: 0xf8da3024 │ │ │ │ @ instruction: 0xf6482028 │ │ │ │ - vsubhn.i16 d23, q8, q14 │ │ │ │ + vsubhn.i16 d23, q8, q10 │ │ │ │ stcls 6, cr0, [r9], {2} │ │ │ │ - stmiavc r4!, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmvc ip, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdaeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ ldrmi r4, [r1], r5, lsr #12 │ │ │ │ strls r2, [fp, -r0, lsl #6] │ │ │ │ movwls r9, #21255 @ 0x5307 │ │ │ │ @ instruction: 0x2c006a2c │ │ │ │ vqadd.s8 , q5, │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ strls r0, [sl, #-770] @ 0xfffffcfe │ │ │ │ stmdbvs r5!, {r3, r8, r9, ip, pc}^ │ │ │ │ @ instruction: 0xf8ca2700 │ │ │ │ stccs 0, cr7, [r0, #-240] @ 0xffffff10 │ │ │ │ ldrtmi sp, [fp], sp, asr #32 │ │ │ │ and r9, sl, r4, lsl #8 │ │ │ │ strbmi r4, [r1], -r0, lsr #12 │ │ │ │ - stmib ip!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib r0!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs fp!, {r3, r4, r8, fp, ip, sp, pc} │ │ │ │ svclt 0x00082b01 │ │ │ │ stmdavs sp!, {r0, r1, r2, r3, r5, r6, r7, fp, sp, lr} │ │ │ │ stmdavs ip!, {r0, r2, r3, r4, r6, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0x46204631 │ │ │ │ - stmib r0!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmib r4!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ mvnle r2, r0, lsl #16 │ │ │ │ @ instruction: 0xf04f682d │ │ │ │ vstrcs d0, [r0, #-4] │ │ │ │ @ instruction: 0xf08bd1f3 │ │ │ │ stcls 5, cr0, [r4], {1} │ │ │ │ svclt 0x000c2f00 │ │ │ │ @ instruction: 0xf0052500 │ │ │ │ cmplt r5, #4194304 @ 0x400000 │ │ │ │ - bls 1c28e0 │ │ │ │ + bls 1c28d8 │ │ │ │ movwls r3, #21249 @ 0x5301 │ │ │ │ strbmi r2, [fp], -r5, lsl #20 │ │ │ │ stmdbeq r1, {r0, r3, r8, ip, sp, lr, pc} │ │ │ │ eorls pc, r8, sl, asr #17 │ │ │ │ stmdbls r7, {r0, r1, r2, r3, r4, ip, lr, pc} │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ @ instruction: 0xf0002900 │ │ │ │ movwls r8, #640 @ 0x280 │ │ │ │ @ instruction: 0xf8da9b08 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vaddw.s8 q10, q8, d28 │ │ │ │ + vaddw.s8 q10, q8, d20 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0x4642fd39 │ │ │ │ @ instruction: 0x46504639 │ │ │ │ - blx fe959d04 │ │ │ │ + blx fe959cfc │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ - msrcs R12_usr, r9 │ │ │ │ + tstpcs ip, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2 7, cr15, [ip, #-1016]! @ 0xfffffc08 │ │ │ │ ldrdls pc, [r8], -sl @ │ │ │ │ stmdavs r4!, {r0, r1, r2, r8, sl, ip, pc} │ │ │ │ @ instruction: 0xd1a82c00 │ │ │ │ - blvs b83150 │ │ │ │ + blvs b83148 │ │ │ │ orrsle r2, fp, r0, lsl #26 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0xf6499315 │ │ │ │ - vmov.i64 q11, #0x0000000000ff0000 │ │ │ │ - blls 19f548 │ │ │ │ + vqrdmlah.s d22, d0, d0[7] │ │ │ │ + blls 19f540 │ │ │ │ @ instruction: 0xf6489e09 │ │ │ │ - vmull.s8 q10, d0, d24 │ │ │ │ - blcc 15ed54 │ │ │ │ + vmull.s8 q10, d0, d16 │ │ │ │ + blcc 15ed4c │ │ │ │ @ instruction: 0xb014f8dd │ │ │ │ movwcs fp, #7960 @ 0x1f18 │ │ │ │ @ instruction: 0xf8cd9f0b │ │ │ │ vqadd.s8 , , q0 │ │ │ │ - vbic.i16 q9, #12 @ 0x000c │ │ │ │ + vbic.i16 q9, #4 @ 0x0004 │ │ │ │ ldrls r0, [r7, #-2306] @ 0xfffff6fe │ │ │ │ @ instruction: 0xf8cd9312 │ │ │ │ @ instruction: 0x9719b038 │ │ │ │ sub pc, ip, sp, asr #17 │ │ │ │ subgt pc, r0, sp, asr #17 │ │ │ │ vstrcs s12, [r0, #-212] @ 0xffffff2c │ │ │ │ rsbhi pc, r8, #0 │ │ │ │ stmdbvs ip!, {r1, r2, r4, r9, sl, ip, pc}^ │ │ │ │ @ instruction: 0xf8ca2300 │ │ │ │ stccs 0, cr3, [r0], {60} @ 0x3c │ │ │ │ tstphi sp, #0 @ p-variant is OBSOLETE │ │ │ │ stmdaeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ vpadd.i8 d25, d9, d0 │ │ │ │ - vrshr.s64 q9, q4, #64 │ │ │ │ + vrshr.s64 q9, q0, #64 │ │ │ │ vhsub.s8 d16, d11, d2 │ │ │ │ - vbic.i32 , #12 @ 0x0000000c │ │ │ │ + vbic.i32 , #4 @ 0x00000004 │ │ │ │ strbmi r0, [r3], r2, lsl #2 │ │ │ │ - strcc pc, [r4, -r9, asr #4] │ │ │ │ + ldrbcs pc, [ip, r9, asr #4]! @ │ │ │ │ streq pc, [r2, -r0, asr #5] │ │ │ │ - strtvc pc, [ip], r8, asr #12 │ │ │ │ + strtvc pc, [r4], r8, asr #12 │ │ │ │ streq pc, [r2], -r0, asr #5 │ │ │ │ andshi pc, r4, sp, asr #17 │ │ │ │ eorhi pc, r0, sp, asr #17 │ │ │ │ strhi lr, [fp, #-2509] @ 0xfffff633 │ │ │ │ @ instruction: 0xf8cd4690 │ │ │ │ strmi sl, [sl], r8, lsr #32 │ │ │ │ eor r9, r0, r4, lsl #6 │ │ │ │ - bcs 76058 │ │ │ │ + bcs 76050 │ │ │ │ mvnshi pc, r0 │ │ │ │ @ instruction: 0x46284631 │ │ │ │ - stmdb r6, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb sl, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ strbmi r8, [r1], -sl, ror #3 │ │ │ │ @ instruction: 0xf7f54628 │ │ │ │ - stmdacs r0, {r8, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r2, r8, fp, sp, lr, pc} │ │ │ │ mvnhi pc, r0 │ │ │ │ @ instruction: 0x46284651 │ │ │ │ - ldm r8!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm ip!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ stmiavs r2!, {r0, r2, r5, r6, r7, r8, pc} │ │ │ │ tstle r2, r1, lsl #20 │ │ │ │ stmiavs r2!, {r1, r3, r8, r9, fp, ip, pc}^ │ │ │ │ stmdavs r4!, {r1, r3, r4, r6, r7, r8, r9, sp, lr} │ │ │ │ stmdavs r5!, {r2, r5, r7, r8, ip, sp, pc}^ │ │ │ │ strtmi r4, [r8], -r9, asr #12 │ │ │ │ - stmia r8!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia ip!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ sbcsle r2, r7, r0, lsl #16 │ │ │ │ @ instruction: 0x46284639 │ │ │ │ - stmia r2!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia r6!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ bicsle r2, r5, r0, lsl #16 │ │ │ │ - bcs 760b4 │ │ │ │ + bcs 760ac │ │ │ │ stmiavs r3!, {r1, r4, r6, r7, r8, ip, lr, pc}^ │ │ │ │ movwls r6, #22564 @ 0x5824 │ │ │ │ mvnle r2, r0, lsl #24 │ │ │ │ strhi lr, [fp, #-2525] @ 0xfffff623 │ │ │ │ ldrdge pc, [r8], -sp @ │ │ │ │ svceq 0x0000f1bb │ │ │ │ mvnshi pc, r0, asr #32 │ │ │ │ - bls 402a60 │ │ │ │ + bls 402a58 │ │ │ │ svclt 0x00183b00 │ │ │ │ andsmi r2, sl, #67108864 @ 0x4000000 │ │ │ │ subhi pc, r9, #64 @ 0x40 │ │ │ │ - bls 22d6a0 │ │ │ │ + bls 22d698 │ │ │ │ @ instruction: 0xf0404211 │ │ │ │ stmdbls r6, {r0, r1, r2, r4, r6, r9, pc} │ │ │ │ @ instruction: 0xf0002905 │ │ │ │ tstmi r3, #-1879048183 @ 0x90000009 │ │ │ │ @ instruction: 0x4611d014 │ │ │ │ - movwcc pc, #16969 @ 0x4249 @ │ │ │ │ + mvnscs pc, #-1879048188 @ 0x90000004 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - sbcscs pc, r8, #-1879048188 @ 0x90000004 │ │ │ │ + sbcscs pc, r0, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ldrdeq pc, [ip], -sl @ │ │ │ │ svclt 0x00082900 │ │ │ │ @ instruction: 0xf649461a │ │ │ │ - vsra.s64 , q0, #64 │ │ │ │ + vmla.f d21, d16, d0[2] │ │ │ │ stmdavs fp!, {r1, r8}^ │ │ │ │ mcr2 7, 5, pc, cr10, cr12, {7} @ │ │ │ │ @ instruction: 0xf1b89b0e │ │ │ │ andle r0, r6, r0, lsl #30 │ │ │ │ - bcc 826dc │ │ │ │ - bls 5406e0 │ │ │ │ + bcc 826d4 │ │ │ │ + bls 5406d8 │ │ │ │ @ instruction: 0xf8ca1ad3 │ │ │ │ - bls 127fc0 │ │ │ │ + bls 127fb8 │ │ │ │ movweq pc, #49413 @ 0xc105 @ │ │ │ │ strcs r9, [r0], #-2321 @ 0xfffff6ef │ │ │ │ eorcc pc, ip, sl, asr #17 │ │ │ │ stmdavs fp!, {r0, r1, r4, fp, ip, pc}^ │ │ │ │ stc2 0, cr15, [lr], {11} │ │ │ │ @ instruction: 0xf8ca696b │ │ │ │ strmi r3, [r6], -ip │ │ │ │ @ instruction: 0x46519b12 │ │ │ │ subcc pc, r1, sl, lsl #17 │ │ │ │ andseq pc, r0, sl, asr #17 │ │ │ │ eorsmi pc, r4, sl, asr #17 │ │ │ │ @ instruction: 0xf7ff68a8 │ │ │ │ ldrtmi pc, [r0], -r7, lsr #25 @ │ │ │ │ submi pc, r1, sl, lsl #17 │ │ │ │ - ldm sl, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blcs 182b08 │ │ │ │ + ldm lr, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blcs 182b00 │ │ │ │ eorhi pc, r2, #0 │ │ │ │ stccs 8, cr6, [r0, #-180] @ 0xffffff4c │ │ │ │ @ instruction: 0x81a7f000 │ │ │ │ eorsmi pc, ip, sl, asr #17 │ │ │ │ @ instruction: 0x2c00696c │ │ │ │ svcge 0x0042f47f │ │ │ │ movwls r9, #19216 @ 0x4b10 │ │ │ │ - blls 295e4c │ │ │ │ - bcs 36a7c <__time64@plt+0x25794> │ │ │ │ + blls 295e44 │ │ │ │ + bcs 36a74 <__time64@plt+0x2578c> │ │ │ │ rsbhi pc, r0, #0 │ │ │ │ ldrsbteq pc, [r0], -ip @ │ │ │ │ ldmdavs r2, {r0, r1, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ - bvs fe4fc88c │ │ │ │ + bvs fe4fc884 │ │ │ │ movweq lr, #14896 @ 0x3a30 │ │ │ │ stccs 1, cr13, [r0, #-988] @ 0xfffffc24 │ │ │ │ ldrhi pc, [lr], #-0 │ │ │ │ ldr r9, [r0], #521 @ 0x209 │ │ │ │ - blls 26dac4 │ │ │ │ + blls 26dabc │ │ │ │ ldmdavs fp, {r0, r1, r3, r4, r6, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf43f2b02 │ │ │ │ @ instruction: 0xf8daaddd │ │ │ │ @ instruction: 0xf8da6010 │ │ │ │ @ instruction: 0xf8da0008 │ │ │ │ stccs 0, cr2, [r0], {36} @ 0x24 │ │ │ │ @ instruction: 0x83aef000 │ │ │ │ ldrdpl pc, [r4], #-138 @ 0xffffff76 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - orrcs pc, r8, r9, asr #12 │ │ │ │ + orrcs pc, r0, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2 7, cr15, [r0], {254} @ 0xfe │ │ │ │ vrshl.s8 d25, d0, d10 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ @ instruction: 0xf6492024 │ │ │ │ - vbic.i32 d20, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d20, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ andcc r0, r2, #8 │ │ │ │ eorcs pc, r4, sl, asr #17 │ │ │ │ - blx ffbd9f8e │ │ │ │ + blx ffbd9f86 │ │ │ │ umaalcc pc, r1, sl, r8 @ │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ stmib sp, {r1, r2, r8, r9, pc}^ │ │ │ │ vrshl.s8 d21, d2, d10 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ stmib sp, {r1, r8, r9}^ │ │ │ │ @ instruction: 0xf6495500 │ │ │ │ - vmla.f d20, d16, d0[2] │ │ │ │ + vmla.f d20, d16, d0[0] │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ @ instruction: 0xf7fe0008 │ │ │ │ @ instruction: 0xf8dafbd7 │ │ │ │ strtmi r3, [sl], -r4, lsr #32 │ │ │ │ movwcc r4, #9777 @ 0x2631 │ │ │ │ - adcmi pc, r4, r9, asr #12 │ │ │ │ + addsmi pc, ip, r9, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ eorcc pc, r4, sl, asr #17 │ │ │ │ stc2 0, cr15, [r2], {11} │ │ │ │ movwcs r9, #6665 @ 0x1a09 │ │ │ │ ldrbmi r4, [r1], -r4, lsl #12 │ │ │ │ @ instruction: 0xf8ca6950 │ │ │ │ @ instruction: 0xf8ca3034 │ │ │ │ @ instruction: 0xf7ff4010 │ │ │ │ @ instruction: 0x4620fc1f │ │ │ │ - ldmda r4, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda r8, {r0, r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ @ instruction: 0xf6492300 │ │ │ │ - vmla.f d18, d16, d0[0] │ │ │ │ - bcc 9c410 │ │ │ │ + vsra.s64 d18, d24, #64 │ │ │ │ + bcc 9c408 │ │ │ │ eorscc pc, r4, sl, asr #17 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ andsvs pc, r0, sl, asr #17 │ │ │ │ eorcs pc, r4, sl, asr #17 │ │ │ │ - blx fe9da01e │ │ │ │ + blx fe9da016 │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - biccs pc, r0, r9, asr #12 │ │ │ │ + @ instruction: 0x21b8f649 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf8da3a02 │ │ │ │ @ instruction: 0xf8ca0008 │ │ │ │ andslt r2, sp, r4, lsr #32 │ │ │ │ svcmi 0x00f0e8bd │ │ │ │ - bllt fe4da044 │ │ │ │ + bllt fe4da03c │ │ │ │ @ instruction: 0x469146d3 │ │ │ │ movwcs r4, #5858 @ 0x16e2 │ │ │ │ subcc pc, r8, sl, lsl #17 │ │ │ │ svceq 0x0000f1bb │ │ │ │ - blls 290074 │ │ │ │ + blls 29006c │ │ │ │ ldmibvs fp, {r0, r1, r3, r4, r6, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - blls 1fd008 │ │ │ │ + blls 1fd000 │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ stccs 2, cr8, [r0], {208} @ 0xd0 │ │ │ │ mvnhi pc, r0 │ │ │ │ @ instruction: 0x6010f8da │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrdpl pc, [r4], #-138 @ 0xffffff76 │ │ │ │ @ instruction: 0xf6499600 │ │ │ │ - vaddw.s8 , q8, d20 │ │ │ │ + vsra.s64 d19, d12, #64 │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ @ instruction: 0xf8da0008 │ │ │ │ @ instruction: 0xf7fe7020 │ │ │ │ strls pc, [r0, #-2919] @ 0xfffff499 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - teqpmi ip, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqpmi r4, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ @ instruction: 0xf8ca3202 │ │ │ │ @ instruction: 0xf7fe2024 │ │ │ │ stmib sp, {r0, r2, r4, r6, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ vrshl.s8 d21, d0, d10 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ @ instruction: 0xf6492024 │ │ │ │ - vmla.f d20, d0, d0[3] │ │ │ │ + vmla.f d20, d0, d0[1] │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ @ instruction: 0xf7fe0008 │ │ │ │ @ instruction: 0xf89afb45 │ │ │ │ - blcs 281f0 <__time64@plt+0x16f08> │ │ │ │ + blcs 281e8 <__time64@plt+0x16f00> │ │ │ │ tstphi sp, #64 @ p-variant is OBSOLETE @ 0x40 │ │ │ │ - adcvc pc, r4, #72, 12 @ 0x4800000 │ │ │ │ + addsvc pc, ip, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ldrbmi r4, [r0], -r1, lsr #12 │ │ │ │ @ instruction: 0xf8a8f7ff │ │ │ │ umaalcc pc, r9, sl, r8 @ │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ strtmi r8, [sl], -sl, ror #6 │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ - orrsmi pc, r4, r9, asr #12 │ │ │ │ + orrmi pc, ip, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx ada116 │ │ │ │ + blx ada10e │ │ │ │ ldrdcc pc, [r4], -sl @ │ │ │ │ ldrtmi r4, [r1], -sl, lsr #12 │ │ │ │ @ instruction: 0xf6493302 │ │ │ │ - vaddl.s8 q10, d16, d20 │ │ │ │ + vshr.s64 d20, d12, #64 │ │ │ │ @ instruction: 0xf8ca0002 │ │ │ │ @ instruction: 0xf00b3024 │ │ │ │ vstrls d15, [r9, #-340] @ 0xfffffeac │ │ │ │ ldrbmi r2, [r1], -r1, lsl #6 │ │ │ │ eorscc pc, r4, sl, asr #17 │ │ │ │ @ instruction: 0xf8ca4604 │ │ │ │ @ instruction: 0xf8ca0010 │ │ │ │ stmdbvs r8!, {r5, sp, lr}^ │ │ │ │ - blx 1c5a14e │ │ │ │ + blx 1c5a146 │ │ │ │ @ instruction: 0xf7f44620 │ │ │ │ - @ instruction: 0xf8daef66 │ │ │ │ + @ instruction: 0xf8daef6a │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ movwcs r0, #8 │ │ │ │ @ instruction: 0xf8ca3a02 │ │ │ │ stmib sl, {r2, r4, r5, ip, sp}^ │ │ │ │ vhsub.s8 d23, d10, d8 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8ca0302 │ │ │ │ @ instruction: 0xf6496010 │ │ │ │ - vmla.f d18, d16, d0[0] │ │ │ │ + vsra.s64 d18, d24, #64 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf8dafaf7 │ │ │ │ ldrbmi r3, [r1], -r0 │ │ │ │ ldrmi r4, [r8, r8, lsr #12] │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0xf6493a02 │ │ │ │ - vmla.f d18, d16, d0[0] │ │ │ │ + vsra.s64 d18, d24, #64 │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ @ instruction: 0xf8ca0008 │ │ │ │ @ instruction: 0xf7fe2024 │ │ │ │ movwcs pc, #2785 @ 0xae1 @ │ │ │ │ subcc pc, r8, sl, lsl #17 │ │ │ │ @ instruction: 0xf04fe4a4 │ │ │ │ strt r0, [r6], -r1, lsl #22 │ │ │ │ movwls r2, #33537 @ 0x8301 │ │ │ │ stmiavs r3!, {r0, r1, r5, r9, sl, sp, lr, pc}^ │ │ │ │ strt r9, [r0], -r4, lsl #6 │ │ │ │ - @ instruction: 0x71a4f648 │ │ │ │ + orrsvc pc, ip, r8, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f44628 │ │ │ │ - stmdacs r0, {r1, r3, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r3, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ mrcge 4, 0, APSR_nzcv, cr7, cr15, {3} │ │ │ │ - bcs 76468 │ │ │ │ + bcs 76460 │ │ │ │ mrcge 4, 0, APSR_nzcv, cr3, cr15, {3} │ │ │ │ movwls r6, #47331 @ 0xb8e3 │ │ │ │ @ instruction: 0xf8dae60f │ │ │ │ vhadd.s8 d16, d10, d8 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf6490302 │ │ │ │ - vaddw.s8 q9, q8, d8 │ │ │ │ + vaddw.s8 q9, q8, d0 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf8dafab7 │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ andcc r3, r2, #40 @ 0x28 │ │ │ │ eorcs pc, r4, sl, asr #17 │ │ │ │ movwls r3, #2817 @ 0xb01 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ ldmdavs sl, {r0, r1, r2, r5, r6, r8, sl, sp, lr, pc} │ │ │ │ bicscc pc, r8, r0, asr #4 │ │ │ │ smlabteq r5, r0, r2, pc @ │ │ │ │ tstlt r2, r8, lsl #16 │ │ │ │ ldmdavs fp, {r0, r3, r9, ip, sp}^ │ │ │ │ - tstpvs r0, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + mvnspl pc, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f49400 │ │ │ │ - stmdavs sp!, {r1, r2, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdavs sp!, {r1, r3, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf47f2d00 │ │ │ │ mrcls 13, 0, sl, cr6, cr10, {4} │ │ │ │ vmovcs.16 d0[0], r6 │ │ │ │ ldcge 4, cr15, [r0, #508] @ 0x1fc │ │ │ │ svcls 0x00199b11 │ │ │ │ andscc pc, r0, sl, asr #17 │ │ │ │ stmib sl, {r3, r4, r8, r9, fp, ip, pc}^ │ │ │ │ - blls 5e9e7c │ │ │ │ + blls 5e9e74 │ │ │ │ @ instruction: 0xf0839a0f │ │ │ │ @ instruction: 0xf8ca0301 │ │ │ │ andsmi r6, sl, #60 @ 0x3c │ │ │ │ ldcge 4, cr15, [r3], {127} @ 0x7f │ │ │ │ - bls 382ec0 │ │ │ │ + bls 382eb8 │ │ │ │ svclt 0x000c2a00 │ │ │ │ @ instruction: 0xf0032300 │ │ │ │ - blcs 1ce88 <__time64@plt+0xbba0> │ │ │ │ + blcs 1ce80 <__time64@plt+0xbb98> │ │ │ │ @ instruction: 0x81b1f040 │ │ │ │ - blcs 182ea4 │ │ │ │ + blcs 182e9c │ │ │ │ stcge 4, cr15, [r1], #-252 @ 0xffffff04 │ │ │ │ @ instruction: 0xf43f2a00 │ │ │ │ - blls 28735c │ │ │ │ + blls 287354 │ │ │ │ @ instruction: 0x4651aa1b │ │ │ │ movwcs r6, #2904 @ 0xb58 │ │ │ │ @ instruction: 0xf7ff931b │ │ │ │ - blls 61ab7c │ │ │ │ + blls 61ab74 │ │ │ │ @ instruction: 0xf47f2b00 │ │ │ │ @ instruction: 0xf8daac12 │ │ │ │ vhadd.s8 d18, d10, d20 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vaddw.s8 q11, q8, d12 │ │ │ │ + vaddw.s8 q11, q8, d4 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf8dafa53 │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ vhadd.s8 d16, d10, d8 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf6490302 │ │ │ │ - vsra.s64 d22, d16, #64 │ │ │ │ + vaddw.s8 q11, q8, d24 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf7fffa45 │ │ │ │ - blls 18b2bc │ │ │ │ - cmnpcs r8, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + blls 18b2b4 │ │ │ │ + cmnpcs r0, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blls 580ef8 │ │ │ │ + blls 580ef0 │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ - blx dda2fc │ │ │ │ + blx dda2f4 │ │ │ │ ldrdcc pc, [r4], -sl @ │ │ │ │ @ instruction: 0xf8ca3302 │ │ │ │ strb r3, [r3, #36] @ 0x24 │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ - bicpl pc, r0, r9, asr #12 │ │ │ │ + @ instruction: 0x51b8f649 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf8da9b15 │ │ │ │ @ instruction: 0xf7fe0008 │ │ │ │ @ instruction: 0xf8dafa25 │ │ │ │ andcs r3, r1, #36 @ 0x24 │ │ │ │ movwcc r9, #8727 @ 0x2217 │ │ │ │ eorcc pc, r4, sl, asr #17 │ │ │ │ ldr r9, [r0, #2830]! @ 0xb0e │ │ │ │ @ instruction: 0xf6499b15 │ │ │ │ - vmla.f d18, d16, d0[2] │ │ │ │ + vmla.f d18, d16, d0[0] │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ @ instruction: 0xf7fe0008 │ │ │ │ stmdavs sp!, {r0, r4, r9, fp, ip, sp, lr, pc} │ │ │ │ ldrdcc pc, [r4], -sl @ │ │ │ │ @ instruction: 0xf8ca3b02 │ │ │ │ stccs 0, cr3, [r0, #-144] @ 0xffffff70 │ │ │ │ svcge 0x0075f43f │ │ │ │ eorsmi pc, ip, sl, asr #17 │ │ │ │ @ instruction: 0x2c00696c │ │ │ │ ldcge 4, cr15, [r0, #-508] @ 0xfffffe04 │ │ │ │ stmdaeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ - msrmi CPSR_f, #72, 12 @ 0x4800000 │ │ │ │ + msrmi CPSR_, #72, 12 @ 0x4800000 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ stmiavs fp!, {r2, r8, r9, ip, pc} │ │ │ │ ldmdavs sl, {r2, r3, r5, r6, fp, sp, lr} │ │ │ │ ldrdcc pc, [ip], -sl @ │ │ │ │ @ instruction: 0xf43f2a02 │ │ │ │ strtmi sl, [r2], -ip, asr #30 │ │ │ │ @ instruction: 0xf6494618 │ │ │ │ - vmla.f d22, d0, d0[1] │ │ │ │ + vbic.i32 d22, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ ldrb pc, [sp, #-3113]! @ 0xfffff3d7 @ │ │ │ │ movweq pc, #4226 @ 0x1082 @ │ │ │ │ - bcs 42bb8 <__time64@plt+0x318d0> │ │ │ │ + bcs 42bb0 <__time64@plt+0x318c8> │ │ │ │ movwcs fp, #3860 @ 0xf14 │ │ │ │ movweq pc, #4099 @ 0x1003 @ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ - blls 29597c │ │ │ │ + blls 295974 │ │ │ │ strtmi r4, [ip], -sl, lsr #12 │ │ │ │ strls r4, [sl, #-1706] @ 0xfffff956 │ │ │ │ strls r6, [sp, #-2073] @ 0xfffff7e7 │ │ │ │ @ instruction: 0xf7ff9507 │ │ │ │ - blls 1caed8 │ │ │ │ + blls 1caed0 │ │ │ │ @ instruction: 0xf47f2b05 │ │ │ │ bfi sl, sp, (invalid: 27:13) │ │ │ │ movwls r2, #29441 @ 0x7301 │ │ │ │ - blt fe09a3d4 │ │ │ │ - blls 26df64 │ │ │ │ - bicsvs pc, r4, r9, asr #12 │ │ │ │ + blt fe09a3cc │ │ │ │ + blls 26df5c │ │ │ │ + bicvs pc, ip, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ff695a │ │ │ │ vpadd.i8 d27, d25, d5 │ │ │ │ - @ instruction: 0xf2c03494 │ │ │ │ + vaddhn.i16 d19, q8, q6 │ │ │ │ stmdavs r8!, {r1, sl}^ │ │ │ │ @ instruction: 0xf7f44621 │ │ │ │ - ldmdblt r0, {r3, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ - blcs 766ac │ │ │ │ + ldmdblt r0, {r2, r3, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + blcs 766a4 │ │ │ │ stmdavs sp!, {r1, r2, r3, ip, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #26 │ │ │ │ @ instruction: 0xf8ca9b11 │ │ │ │ - blls 1a8480 │ │ │ │ + blls 1a8478 │ │ │ │ andsvc pc, r8, sl, asr #17 │ │ │ │ @ instruction: 0xf0002b05 │ │ │ │ movwcs r8, #498 @ 0x1f2 │ │ │ │ ldr r9, [r0], #-781 @ 0xfffffcf3 │ │ │ │ stmdavs sp!, {r0, r1, r3, r5, r6, r7, fp, sp, lr} │ │ │ │ @ instruction: 0xf47f2d00 │ │ │ │ movwls sl, #56239 @ 0xdbaf │ │ │ │ - bllt fed5a42c │ │ │ │ + bllt fed5a424 │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - biccs pc, r0, r9, asr #12 │ │ │ │ + @ instruction: 0x21b8f649 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrb r3, [r8, #2562]! @ 0xa02 │ │ │ │ ldmdbvs r8, {r0, r3, r8, r9, fp, ip, pc}^ │ │ │ │ svcne 0x001a6803 │ │ │ │ - blcs 6b078 │ │ │ │ - bcs 8c278 │ │ │ │ + blcs 6b070 │ │ │ │ + bcs 8c270 │ │ │ │ bichi pc, fp, r0, lsl #4 │ │ │ │ svceq 0x0000f1b9 │ │ │ │ bicshi pc, sp, r0 │ │ │ │ ldrdcc pc, [r0], -r9 │ │ │ │ @ instruction: 0x2010f8da │ │ │ │ svcne 0x0019681b │ │ │ │ - blcs 6b098 │ │ │ │ + blcs 6b090 │ │ │ │ stmdbcs r1, {r3, r7, r8, r9, sl, fp, ip, sp, pc} │ │ │ │ bicshi pc, r6, r0, lsl #4 │ │ │ │ @ instruction: 0x601cf8da │ │ │ │ @ instruction: 0xf89a2301 │ │ │ │ @ instruction: 0xf649504a │ │ │ │ - vaddw.s8 q9, q8, d8 │ │ │ │ + vaddw.s8 q9, q8, d0 │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ @ instruction: 0xf8ca0008 │ │ │ │ @ instruction: 0xf88a201c │ │ │ │ vhadd.s8 , q5, q5 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ @ instruction: 0xf7fe2024 │ │ │ │ @ instruction: 0xf8daf963 │ │ │ │ @ instruction: 0xf8da1028 │ │ │ │ @ instruction: 0xf6493024 │ │ │ │ - vmla.i d19, d16, d0[6] │ │ │ │ + vmla.i d19, d16, d0[4] │ │ │ │ movwcc r0, #8194 @ 0x2002 │ │ │ │ eorcc pc, r4, sl, asr #17 │ │ │ │ @ instruction: 0xf8ca1c4b │ │ │ │ @ instruction: 0xf00b3028 │ │ │ │ @ instruction: 0xf8d9f98b │ │ │ │ @ instruction: 0xf89a4000 │ │ │ │ strmi r7, [r2], -r0, asr #32 │ │ │ │ andseq pc, r0, sl, asr #17 │ │ │ │ - bicscc pc, r0, #76, 12 @ 0x4c00000 │ │ │ │ + biccc pc, r8, #76, 12 @ 0x4c00000 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ vadd.i8 d22, d9, d17 │ │ │ │ - vmla.i d21, d16, d0[3] │ │ │ │ + vmla.i d21, d16, d0[1] │ │ │ │ stmdbcs r5, {r1} │ │ │ │ strmi fp, [r3], -r8, lsl #30 │ │ │ │ movwls r6, #2401 @ 0x961 │ │ │ │ - strbmi pc, [r4], #586 @ 0x24a @ │ │ │ │ + ldrtmi pc, [ip], #586 @ 0x24a @ │ │ │ │ streq pc, [r2], #-704 @ 0xfffffd40 │ │ │ │ - bicscs pc, r4, #76546048 @ 0x4900000 │ │ │ │ + biccs pc, ip, #76546048 @ 0x4900000 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ andls r9, r3, #1073741824 @ 0x40000000 │ │ │ │ svclt 0x00182f00 │ │ │ │ movwls r4, #9763 @ 0x2623 │ │ │ │ - tstpmi r8, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpmi r0, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf8da4623 │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ @ instruction: 0xf7fe0008 │ │ │ │ @ instruction: 0xf8daf925 │ │ │ │ strtmi r2, [r3], -r4, lsr #32 │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ @ instruction: 0xf6493202 │ │ │ │ - vaddw.s8 q10, q0, d28 │ │ │ │ + vaddw.s8 q10, q0, d20 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf8d9f919 │ │ │ │ ldrbmi r1, [r0], -r8 │ │ │ │ - sbcvc pc, r0, #72, 12 @ 0x4800000 │ │ │ │ + adcsvc pc, r8, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ mcr2 7, 4, pc, cr0, cr14, {7} @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ - teqpvc ip, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpvc r4, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf908f7fe │ │ │ │ ldrdcc pc, [r0], -sl │ │ │ │ ldrdeq pc, [r0], -r9 │ │ │ │ @ instruction: 0x47984651 │ │ │ │ umaalcc pc, r0, sl, r8 @ │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ @ instruction: 0xf8da8180 │ │ │ │ vhadd.s8 d18, d10, d20 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ - bcc 9c5a8 │ │ │ │ - biccs pc, r0, r9, asr #12 │ │ │ │ + bcc 9c5a0 │ │ │ │ + @ instruction: 0x21b8f649 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ eorcs pc, r4, sl, asr #17 │ │ │ │ @ instruction: 0xf8ecf7fe │ │ │ │ @ instruction: 0x301cf8da │ │ │ │ andscc pc, r0, sl, asr #17 │ │ │ │ andsvs pc, ip, sl, asr #17 │ │ │ │ subpl pc, sl, sl, lsl #17 │ │ │ │ strls lr, [r0, #-1537] @ 0xfffff9ff │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - @ instruction: 0x41acf649 │ │ │ │ + @ instruction: 0x41a4f649 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ @ instruction: 0xf8d4f7fe │ │ │ │ - adcvc pc, r4, #72, 12 @ 0x4800000 │ │ │ │ + addsvc pc, ip, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ldrbmi r4, [r0], -r1, lsr #12 │ │ │ │ mrc2 7, 1, pc, cr12, cr14, {7} │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ - msrcs R12_usr, r9 │ │ │ │ + tstpcs ip, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf8c4f7fe │ │ │ │ @ instruction: 0xf8dae4d9 │ │ │ │ vhadd.s8 d18, d10, d20 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vmla.f d18, d16, d0[2] │ │ │ │ + vmla.f d18, d16, d0[0] │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf8daf8b5 │ │ │ │ - blcc a869c │ │ │ │ + blcc a8694 │ │ │ │ eorcc pc, r4, sl, asr #17 │ │ │ │ @ instruction: 0xf8dae641 │ │ │ │ @ instruction: 0xf6493010 │ │ │ │ - vaddw.s8 , q8, d20 │ │ │ │ + vsra.s64 d19, d12, #64 │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ movwls r2, #36 @ 0x24 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ @ instruction: 0xf89ef7fe │ │ │ │ ldrdcc pc, [r4], -sl @ │ │ │ │ ldrdcs pc, [r0], -sl │ │ │ │ movwcc r4, #9809 @ 0x2651 │ │ │ │ @ instruction: 0xf8ca9809 │ │ │ │ ldrmi r3, [r0, r4, lsr #32] │ │ │ │ - blls 3959fc │ │ │ │ + blls 3959f4 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ @ instruction: 0xf8da80d6 │ │ │ │ vhadd.s8 d18, d10, d20 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf8da0302 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vaddw.s8 , q8, d4 │ │ │ │ + vbic.i32 , #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ stmdbls sp, {r0, r7, fp, ip, sp, lr, pc} │ │ │ │ vmin.s8 q10, , q0 │ │ │ │ - vrshr.s64 d19, d4, #64 │ │ │ │ + vsubl.s8 , d16, d12 │ │ │ │ @ instruction: 0xf7fe0202 │ │ │ │ @ instruction: 0xf8dafde9 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vsra.s64 d21, d8, #64 │ │ │ │ + vsra.s64 d21, d0, #64 │ │ │ │ @ instruction: 0xf7fe0102 │ │ │ │ @ instruction: 0xf8daf871 │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ vhadd.s8 d16, d10, d8 │ │ │ │ - vqdmlal.s q10, d16, d0[1] │ │ │ │ + vrsra.s64 d20, d28, #64 │ │ │ │ andcc r0, r2, #134217728 @ 0x8000000 │ │ │ │ - orrcs pc, r8, r9, asr #12 │ │ │ │ + orrcs pc, r0, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ eorcs pc, r4, sl, asr #17 │ │ │ │ @ instruction: 0xf860f7fe │ │ │ │ - blt ff21a6b0 │ │ │ │ + blt ff21a6a8 │ │ │ │ ldrdpl pc, [r8], -sl @ │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - orrcs pc, r8, r9, asr #12 │ │ │ │ + orrcs pc, r0, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf8ca1c6c │ │ │ │ @ instruction: 0xf7fe4028 │ │ │ │ @ instruction: 0xf8daf84f │ │ │ │ strls r2, [r0, #-36] @ 0xffffffdc │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0xf8da3202 │ │ │ │ @ instruction: 0xf6490008 │ │ │ │ - vbic.i32 d20, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d20, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf8ca0102 │ │ │ │ @ instruction: 0xf7fe2024 │ │ │ │ strls pc, [r0, #-2109] @ 0xfffff7c3 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ - @ instruction: 0x41acf649 │ │ │ │ + @ instruction: 0x41a4f649 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ @ instruction: 0xf82ef7fe │ │ │ │ @ instruction: 0xf8da9b09 │ │ │ │ vhadd.s8 d16, d13, d8 │ │ │ │ - vbic.i32 q8, #12 @ 0x0000000c │ │ │ │ + vbic.i32 q8, #4 @ 0x00000004 │ │ │ │ ldmibvs sl, {r1, r8} │ │ │ │ @ instruction: 0xf824f7fe │ │ │ │ @ instruction: 0xf8dae756 │ │ │ │ strtmi r0, [sl], -r8 │ │ │ │ - cmnpmi r0, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + msrmi (UNDEF: 104), r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf81af7fe │ │ │ │ - blls 295ac0 │ │ │ │ - mvnsmi pc, r9, asr #12 │ │ │ │ + blls 295ab8 │ │ │ │ + mvnmi pc, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdeq pc, [ip], -sl @ │ │ │ │ @ instruction: 0xf7fc695a │ │ │ │ @ instruction: 0xf7fffa4d │ │ │ │ - blls 48af48 │ │ │ │ + blls 48af40 │ │ │ │ movwvc lr, #27082 @ 0x69ca │ │ │ │ - blcs 183378 │ │ │ │ + blcs 183370 │ │ │ │ svcge 0x0073f43f │ │ │ │ - blcs 4339c <__time64@plt+0x320b4> │ │ │ │ - bge 919968 │ │ │ │ - blt 1a9a76c │ │ │ │ + blcs 43394 <__time64@plt+0x320ac> │ │ │ │ + bge 919960 │ │ │ │ + blt 1a9a764 │ │ │ │ ldmdavs r3, {r1, r5, r6, r7, r9, sl, lr} │ │ │ │ @ instruction: 0xf63f2b0a │ │ │ │ ldm pc, {r0, r1, r6, r7, r8, fp, sp, pc}^ @ │ │ │ │ adcge pc, r0, r3 │ │ │ │ stmdbeq r9, {r1, r2, r9, sl} │ │ │ │ andne r1, r6, r0, lsr #24 │ │ │ │ andls r0, r9, #6 │ │ │ │ stmdblt lr!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ movwcs r9, #774 @ 0x306 │ │ │ │ movwls r9, #41481 @ 0xa209 │ │ │ │ @ instruction: 0xf7ff930d │ │ │ │ - bvs ff50aeb0 │ │ │ │ + bvs ff50aea8 │ │ │ │ sub fp, r7, fp, lsl r9 │ │ │ │ - blcs 36914 <__time64@plt+0x2562c> │ │ │ │ - bvs fe6908bc │ │ │ │ + blcs 3690c <__time64@plt+0x25624> │ │ │ │ + bvs fe6908b4 │ │ │ │ tsteq r1, r0, lsr sl │ │ │ │ @ instruction: 0x461ad1f8 │ │ │ │ strcs lr, [r0], #-2013 @ 0xfffff823 │ │ │ │ @ instruction: 0xf7ff9209 │ │ │ │ strcs fp, [r0], #-3006 @ 0xfffff442 │ │ │ │ strtmi r9, [r1], r9, lsl #4 │ │ │ │ strls r4, [r7], #-1699 @ 0xfffff95d │ │ │ │ - blls 4958d8 │ │ │ │ + blls 4958d0 │ │ │ │ andscc pc, ip, sl, asr #17 │ │ │ │ @ instruction: 0xf8ca9b06 │ │ │ │ - blcs 178838 │ │ │ │ + blcs 178830 │ │ │ │ stmibge fp!, {r0, r1, r2, r3, r4, r5, r6, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf8dae739 │ │ │ │ ldrtmi r0, [r2], -r8 │ │ │ │ - cmnpmi r4, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + msrmi (UNDEF: 108), r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xffc0f7fd │ │ │ │ @ instruction: 0xf649e48b │ │ │ │ - vsra.s64 d19, d28, #64 │ │ │ │ + vsra.s64 d19, d20, #64 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ - blls 28ae24 │ │ │ │ - cmpppl ip, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ + blls 28ae1c │ │ │ │ + cmpppl r4, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdeq pc, [ip], -sl @ │ │ │ │ @ instruction: 0xf7fc695a │ │ │ │ vmla.i8 , , │ │ │ │ - vrsra.s64 d20, d28, #64 │ │ │ │ + vrsra.s64 d20, d20, #64 │ │ │ │ movwls r0, #54018 @ 0xd302 │ │ │ │ @ instruction: 0xf8dae719 │ │ │ │ ldrbmi r3, [r1], -r0 │ │ │ │ strb r4, [r2], #1944 @ 0x798 │ │ │ │ mvncc pc, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldmdblt r0!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrb r9, [r0, #521] @ 0x209 │ │ │ │ @ instruction: 0x4010f8da │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ ldrdcs pc, [r4], -sl @ │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ - orrcc pc, ip, r9, asr #12 │ │ │ │ + orrcc pc, r4, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fd9400 │ │ │ │ @ instruction: 0xf7ffff8b │ │ │ │ - blls 28ada4 │ │ │ │ - orrspl pc, ip, r9, asr #12 │ │ │ │ + blls 28ad9c │ │ │ │ + orrspl pc, r4, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdeq pc, [ip], -sl @ │ │ │ │ @ instruction: 0xf7fc695a │ │ │ │ @ instruction: 0xf7fff9bd │ │ │ │ @ instruction: 0xf8dab9a2 │ │ │ │ @ instruction: 0x4623201c │ │ │ │ @ instruction: 0xf6499200 │ │ │ │ - vbic.i32 d20, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 q10, q0, d24 │ │ │ │ @ instruction: 0xf8da0102 │ │ │ │ @ instruction: 0xf8da2024 │ │ │ │ @ instruction: 0xf7fd0008 │ │ │ │ @ instruction: 0xf8daff6f │ │ │ │ @ instruction: 0xf8d93010 │ │ │ │ ldrbmi r1, [r0], -r4 │ │ │ │ andscc pc, ip, sl, asr #17 │ │ │ │ - sbcvc pc, r0, #72, 12 @ 0x4800000 │ │ │ │ + adcsvc pc, r8, #72, 12 @ 0x4800000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ldc2l 7, cr15, [r2], {254} @ 0xfe │ │ │ │ ldrdeq pc, [r8], -sl │ │ │ │ - teqpvc ip, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpvc r4, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xff5af7fd │ │ │ │ @ instruction: 0xf649e65b │ │ │ │ - vsubl.s8 , d0, d0 │ │ │ │ + vrshr.s64 q11, q12, #64 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf6400002 │ │ │ │ @ instruction: 0xf7f4416b │ │ │ │ - svclt 0x0000fdf9 │ │ │ │ + svclt 0x0000fdfd │ │ │ │ @ instruction: 0x460cb5f0 │ │ │ │ addslt r4, r5, r6, lsl r6 │ │ │ │ subcs r4, ip, #5242880 @ 0x500000 │ │ │ │ strbtmi r2, [r8], -r0, lsl #2 │ │ │ │ - ldcl 7, cr15, [r8], #-976 @ 0xfffffc30 │ │ │ │ + ldcl 7, cr15, [ip], #-976 @ 0xfffffc30 │ │ │ │ movwls r2, #37634 @ 0x9302 │ │ │ │ movweq pc, #49412 @ 0xc104 @ │ │ │ │ stmdbvs r3!, {r0, r1, r3, r8, r9, ip, pc}^ │ │ │ │ stmiavs r3!, {r0, r1, r8, r9, ip, pc}^ │ │ │ │ strvs lr, [r1, #-2509] @ 0xfffff633 │ │ │ │ ldmdavs fp, {r0, r1, r3, r8, ip, sp, pc}^ │ │ │ │ stmdavs r1!, {r2, r3, r8, r9, ip, pc}^ │ │ │ │ - andvc pc, ip, r9, asr #12 │ │ │ │ + andvc pc, r4, r9, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xff66f00a │ │ │ │ @ instruction: 0x46076872 │ │ │ │ - bcs 4093c <__time64@plt+0x2f654> │ │ │ │ + bcs 40934 <__time64@plt+0x2f64c> │ │ │ │ stmdavs r3!, {r0, r2, r4, r5, r6, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf6494628 │ │ │ │ - vorr.i32 d23, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 , q0, d8 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ strtmi pc, [r8], -r1, lsr #30 │ │ │ │ - msrvc R8_fiq, r9 │ │ │ │ + msrvc R8_usr, r9 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xff1af7fd │ │ │ │ stmdavs r3!, {r1, r4, r5, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf6494628 │ │ │ │ - vorr.i32 , #12 @ 0x0000000c │ │ │ │ + vorr.i32 , #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ stmdals r2, {r0, r4, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - orrsvc pc, r8, r9, asr #12 │ │ │ │ + orrsvc pc, r0, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xff0af7fd │ │ │ │ vadd.i8 d25, d11, d2 │ │ │ │ - vorr.i32 d21, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 , q0, d12 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ stmdavs r3!, {r0, r1, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ strbtmi r6, [r9], -r0, lsr #17 │ │ │ │ movwcc lr, #18893 @ 0x49cd │ │ │ │ movwcc lr, #27085 @ 0x69cd │ │ │ │ @ instruction: 0xf88d2301 │ │ │ │ @ instruction: 0xf64a3049 │ │ │ │ - vrsra.s64 , , #64 │ │ │ │ + vqdmlal.s , d16, d1[2] │ │ │ │ movwls r0, #769 @ 0x301 │ │ │ │ @ instruction: 0xff52f7fe │ │ │ │ vmax.s8 d20, d10, d24 │ │ │ │ - vorr.i32 d16, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 q8, q0, d8 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ stmdbvs r3!, {r0, r1, r3, r5, r6, r7, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ vcgt.s8 d25, d10, d3 │ │ │ │ - vorr.i32 d16, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 q8, q0, d12 │ │ │ │ stmdavs r3!, {r1, r8}^ │ │ │ │ @ instruction: 0x46286832 │ │ │ │ mcr2 7, 7, pc, cr0, cr13, {7} @ │ │ │ │ stmdavs r3!, {r1, r4, r5, fp, sp, lr}^ │ │ │ │ vmax.s8 d20, d10, d24 │ │ │ │ - vbic.i32 d16, #8 @ 0x00000008 │ │ │ │ + vbic.i32 d16, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ @ instruction: 0x4628fed7 │ │ │ │ - tstppl r4, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + tstppl ip, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mrc2 7, 6, pc, cr0, cr13, {7} │ │ │ │ ldmib r4, {r0, r3, r5, r6, r9, sl, lr}^ │ │ │ │ stmib sp, {r0, ip, sp}^ │ │ │ │ stmib sp, {r2, r8, r9, ip, sp}^ │ │ │ │ vcgt.s8 d19, d11, d6 │ │ │ │ - vrsra.s64 , , #64 │ │ │ │ + vrsra.s64 , , #64 │ │ │ │ movwls r0, #769 @ 0x301 │ │ │ │ @ instruction: 0xf88d2300 │ │ │ │ @ instruction: 0xf7fe3049 │ │ │ │ shadd16mi pc, r8, pc @ │ │ │ │ - bl 55a9c8 │ │ │ │ + bl 65a9c0 │ │ │ │ vmax.s8 d20, d10, d24 │ │ │ │ - vorr.i32 d16, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 q8, q0, d8 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ @ instruction: 0xb015feb5 │ │ │ │ stmdbvs r3!, {r4, r5, r6, r7, r8, sl, fp, ip, sp, pc}^ │ │ │ │ - tstpeq r4, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + tstpeq ip, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldmdavs r2!, {r0, r1, r8, r9, ip, pc} │ │ │ │ stmdavs r3!, {r3, r5, r9, sl, lr}^ │ │ │ │ svclt 0x0000e7c6 │ │ │ │ @ instruction: 0x460cb538 │ │ │ │ @ instruction: 0xf6494605 │ │ │ │ - vaddw.s8 , q0, d16 │ │ │ │ + vorr.i32 d17, #8 @ 0x00000008 │ │ │ │ stmiavs r0!, {r1, r8} │ │ │ │ mrc2 7, 4, pc, cr14, cr13, {7} │ │ │ │ vadd.i8 d22, d26, d16 │ │ │ │ - vmla.f d16, d0, d0[7] │ │ │ │ + vmla.f d16, d0, d0[5] │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ stmiavs r0!, {r0, r1, r2, r4, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe4629 │ │ │ │ stmiavs r0!, {r0, r3, r4, r5, r6, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ - cmnpeq r8, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmnpeq r0, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mcr2 7, 4, pc, cr12, cr13, {7} @ │ │ │ │ vadd.i8 d22, d27, d16 │ │ │ │ - vorr.i32 d21, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 , q0, d12 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ strtmi pc, [r1], -r5, lsl #29 │ │ │ │ andcs r4, r2, #40, 12 @ 0x2800000 │ │ │ │ - bicseq pc, ip, #-1610612732 @ 0xa0000004 │ │ │ │ + bicseq pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0x61236262 │ │ │ │ - msrvc CPSR_c, #77594624 @ 0x4a00000 │ │ │ │ + tstpvc r9, #77594624 @ p-variant is OBSOLETE @ 0x4a00000 │ │ │ │ movweq pc, #4800 @ 0x12c0 @ │ │ │ │ @ instruction: 0xf7fe6023 │ │ │ │ stmiavs r0!, {r0, r2, r4, r6, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ mvnvc pc, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrhtmi lr, [r8], -sp │ │ │ │ mcrlt 7, 3, pc, cr12, cr13, {7} @ │ │ │ │ @ instruction: 0x4614b570 │ │ │ │ strmi r4, [lr], -r5, lsl #12 │ │ │ │ @ instruction: 0xf6496890 │ │ │ │ - vaddw.s8 , q0, d16 │ │ │ │ + vorr.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ ldrtmi pc, [r2], -r1, ror #28 @ │ │ │ │ @ instruction: 0xf64968a0 │ │ │ │ - vaddw.s8 , q0, d24 │ │ │ │ + vaddw.s8 , q0, d16 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ stmiavs r0!, {r0, r3, r4, r6, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fe4629 │ │ │ │ stmiavs r0!, {r0, r1, r3, r4, r5, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ - mvneq pc, sl, asr #4 │ │ │ │ + bicseq pc, ip, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mcr2 7, 2, pc, cr14, cr13, {7} @ │ │ │ │ vadd.i8 d22, d27, d16 │ │ │ │ - vorr.i32 d21, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 , q0, d12 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ stmiavs r0!, {r0, r1, r2, r6, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - asrvc pc, fp, #4 @ │ │ │ │ + orrsvc pc, r8, fp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mcr2 7, 2, pc, cr0, cr13, {7} @ │ │ │ │ strtmi r6, [r9], -r0, lsr #17 │ │ │ │ - blx fe8daaf0 │ │ │ │ + blx fe8daae8 │ │ │ │ vadd.i8 d22, d26, d16 │ │ │ │ - vaddw.s8 , q0, d0 │ │ │ │ + vsra.s64 q8, q12, #64 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ @ instruction: 0x4621fe35 │ │ │ │ andcs r4, r2, #40, 12 @ 0x2800000 │ │ │ │ - bicseq pc, ip, #-1610612732 @ 0xa0000004 │ │ │ │ + bicseq pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0x61236262 │ │ │ │ mcr2 7, 4, pc, cr10, cr14, {7} @ │ │ │ │ vadd.i8 d22, d26, d16 │ │ │ │ - vmla.f d23, d16, d0[6] │ │ │ │ + vmla.f d23, d16, d0[4] │ │ │ │ pop {r1, r8} │ │ │ │ @ instruction: 0xf7fd4070 │ │ │ │ svclt 0x0000be21 │ │ │ │ @ instruction: 0x4604b538 │ │ │ │ strcc fp, [r9], #-264 @ 0xfffffef8 │ │ │ │ @ instruction: 0xf7f44620 │ │ │ │ - vqdmulh.s d30, d0, d26 │ │ │ │ + vqdmulh.s d30, d0, d30 │ │ │ │ vrsra.s64 , q8, #64 │ │ │ │ - bvs ff75d75c │ │ │ │ + bvs ff75d754 │ │ │ │ stmdble fp, {r3, r5, r7, r9, lr} │ │ │ │ - bcs bf40d8 │ │ │ │ - blvs 690f74 │ │ │ │ + bcs bf40d0 │ │ │ │ + blvs 690f6c │ │ │ │ strtmi r4, [r0], -sl, lsr #12 │ │ │ │ - bl fec5ab2c │ │ │ │ + bl fed5ab24 │ │ │ │ strcc fp, [r1, #-2320] @ 0xfffff6f0 │ │ │ │ @ instruction: 0xbd381960 │ │ │ │ ldclt 0, cr2, [r8, #-0] │ │ │ │ svcmi 0x00f0e92d │ │ │ │ strmi r4, [r8], r4, lsl #12 │ │ │ │ ldrmi fp, [r7], -r7, lsl #1 │ │ │ │ @ instruction: 0xffdcf7ff │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ strmi r8, [r6], -r7, asr #1 │ │ │ │ - beq 298f94 │ │ │ │ + beq 298f8c │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ @ instruction: 0x465080da │ │ │ │ @ instruction: 0xf8a0f7fb │ │ │ │ strtmi r4, [r0], -r3, lsl #13 │ │ │ │ @ instruction: 0xffccf7ff │ │ │ │ stmdacs r0, {r0, r2, r9, sl, lr} │ │ │ │ @ instruction: 0xf7fbd05c │ │ │ │ mcrrne 10, 14, pc, r3, cr5 @ │ │ │ │ vhadd.s8 , q0, q7 │ │ │ │ @ instruction: 0xf2c039f0 │ │ │ │ @ instruction: 0xf8d90905 │ │ │ │ @ instruction: 0xf8533004 │ │ │ │ stmdbcs r0, {r5, ip} │ │ │ │ @ instruction: 0x465ad052 │ │ │ │ - eorne pc, ip, sl, asr #4 │ │ │ │ + eorne pc, r4, sl, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ cdp2 0, 0, cr15, cr12, cr10, {0} │ │ │ │ stmdavc sl!, {r0, r2, r9, sl, lr} │ │ │ │ svclt 0x00082a2e │ │ │ │ andsle r4, lr, r9, lsr #12 │ │ │ │ - sbcscs pc, r0, r2, asr #12 │ │ │ │ + sbccs pc, r8, r2, asr #12 │ │ │ │ andeq pc, r3, r0, asr #5 │ │ │ │ @ instruction: 0xf04f4629 │ │ │ │ and r0, r3, sp, lsr #24 │ │ │ │ svccs 0x0001f811 │ │ │ │ andsle r2, r2, lr, lsr #20 │ │ │ │ andscc pc, r2, r0, lsr r8 @ │ │ │ │ @ instruction: 0xf0032a2d │ │ │ │ - blx fecdda28 │ │ │ │ - b 1419a08 │ │ │ │ + blx fecdda20 │ │ │ │ + b 1419a00 │ │ │ │ svclt 0x00081353 │ │ │ │ - blcs 25804 <__time64@plt+0x1451c> │ │ │ │ + blcs 257fc <__time64@plt+0x14514> │ │ │ │ @ instruction: 0xf881d0ee │ │ │ │ @ instruction: 0xf811c000 │ │ │ │ - bcs ba8814 │ │ │ │ + bcs ba880c │ │ │ │ @ instruction: 0xf64bd1ec │ │ │ │ - vorr.i32 , #1024 @ 0x00000400 │ │ │ │ + vqdmlal.s , d0, d0[3] │ │ │ │ @ instruction: 0xf8d90302 │ │ │ │ ldmdahi r8, {r3, sp} │ │ │ │ mulhi r8, fp, r8 │ │ │ │ - bllt 8b8e54 │ │ │ │ + bllt 8b8e4c │ │ │ │ ldrdeq pc, [r0], -r8 │ │ │ │ - ldmib r8!, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmib ip!, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7f46838 │ │ │ │ - strdcs lr, [r0], -r6 │ │ │ │ + strdcs lr, [r0], -sl │ │ │ │ andpl pc, r0, r8, asr #17 │ │ │ │ andlt r6, r7, lr, lsr r0 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - msrne R8_usr, sl │ │ │ │ + tstpne r8, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ andcs r4, r8, #40, 12 @ 0x2800000 │ │ │ │ - bl d5ac24 │ │ │ │ + bl e5ac1c │ │ │ │ rsble r2, r1, r0, lsl #16 │ │ │ │ ldmibcc r0!, {r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ vmin.s8 q10, q5, │ │ │ │ - vmvn.i32 d17, #8 @ 0x00000008 │ │ │ │ + vmvn.i32 d17, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf00a0002 │ │ │ │ @ instruction: 0x4605fdb9 │ │ │ │ vabd.s8 d30, d16, d27 │ │ │ │ @ instruction: 0xf2c03bd8 │ │ │ │ @ instruction: 0xf6480b05 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf8db0002 │ │ │ │ movwls r3, #20480 @ 0x5000 │ │ │ │ @ instruction: 0xf822f7fb │ │ │ │ - bmi 573c4 │ │ │ │ + bmi 573bc │ │ │ │ vmax.s8 d20, d10, d2 │ │ │ │ - vmla.f d17, d0, d0[0] │ │ │ │ + vbic.i32 d17, #8 @ 0x00000008 │ │ │ │ ldmdavs fp!, {r1, r8} │ │ │ │ stmdals r5, {r0, r1, r8, r9, ip, pc} │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ @ instruction: 0xf6409302 │ │ │ │ @ instruction: 0xf7f4030c │ │ │ │ - @ instruction: 0xf8d9ea80 │ │ │ │ - blcs 28cd4 <__time64@plt+0x179ec> │ │ │ │ + @ instruction: 0xf8d9ea84 │ │ │ │ + blcs 28ccc <__time64@plt+0x179e4> │ │ │ │ @ instruction: 0xf8dbd0b8 │ │ │ │ @ instruction: 0xf6484000 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fb0002 │ │ │ │ @ instruction: 0xf640f805 │ │ │ │ strmi r0, [r2], -pc, lsl #6 │ │ │ │ strtmi r9, [r0], -r0, lsl #10 │ │ │ │ - cmnpne ip, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmnpne r4, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - b 1a5acac │ │ │ │ + b 1b5aca4 │ │ │ │ ldrdcc pc, [r8], -r9 │ │ │ │ adcle r2, r1, r0, lsl #22 │ │ │ │ ldrdmi pc, [r0], -fp │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xffeef7fa │ │ │ │ movwvs pc, #5199 @ 0x144f @ │ │ │ │ strls r4, [r0], -r2, lsl #12 │ │ │ │ vmax.s8 d20, d10, d16 │ │ │ │ - vsra.s64 d17, d4, #64 │ │ │ │ + vaddw.s8 , q8, d12 │ │ │ │ @ instruction: 0xf7f40102 │ │ │ │ - @ instruction: 0xe78dea52 │ │ │ │ + @ instruction: 0xe78dea56 │ │ │ │ @ instruction: 0xf104b1cc │ │ │ │ ldrbmi r0, [r0], -r9, lsl #20 │ │ │ │ @ instruction: 0xffdcf7fa │ │ │ │ ldr r4, [r6, -r6, lsl #12]! │ │ │ │ vmin.s8 q10, q5, q5 │ │ │ │ - vaddw.s8 , q0, d16 │ │ │ │ + vorr.i32 d17, #8 @ 0x00000008 │ │ │ │ vrhadd.s8 d16, d10, d2 │ │ │ │ - vaddl.s8 , d0, d28 │ │ │ │ + vaddl.s8 , d0, d20 │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf2c039f0 │ │ │ │ @ instruction: 0xf00a0905 │ │ │ │ @ instruction: 0x4605fd53 │ │ │ │ strtmi lr, [r2], r5, asr #14 │ │ │ │ @ instruction: 0xf7fae723 │ │ │ │ strtmi pc, [r2], r5, asr #31 │ │ │ │ @@ -11946,92 +11944,92 @@ │ │ │ │ @ instruction: 0xffa0f7fa │ │ │ │ ldrtmi r4, [r8], -r7, lsl #12 │ │ │ │ @ instruction: 0xf9eaf7fb │ │ │ │ strmi r6, [r5], -r3, lsr #17 │ │ │ │ rscle r2, r7, r0, lsl #22 │ │ │ │ ldmibcc r8, {r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrdge pc, [r0], -r9 │ │ │ │ @ instruction: 0xff8cf7fa │ │ │ │ mvnsvs pc, #1325400064 @ 0x4f000000 │ │ │ │ strls r4, [r0, -r2, lsl #12] │ │ │ │ strls r4, [r1, #-1616] @ 0xfffff9b0 │ │ │ │ - mvnne pc, sl, asr #4 │ │ │ │ + bicsne pc, r8, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - stmib lr!, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmib r2!, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ suble r1, r7, sl, ror #24 │ │ │ │ - blcs 37064 <__time64@plt+0x25d7c> │ │ │ │ + blcs 3705c <__time64@plt+0x25d74> │ │ │ │ @ instruction: 0xf648d0cc │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf8d90002 │ │ │ │ @ instruction: 0xf7fa6000 │ │ │ │ - blvs 191cbb8 │ │ │ │ + blvs 191cbb0 │ │ │ │ ldrtmi r4, [r0], -r2, lsl #12 │ │ │ │ - tstpcs r4, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + mvnsne pc, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ eorvs pc, r5, r3, asr r8 @ │ │ │ │ mvnvc pc, #64, 4 │ │ │ │ stmib sp, {r0, r1, r2, r4, r5, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7f46700 │ │ │ │ - blvs 1917554 │ │ │ │ + blvs 191755c │ │ │ │ eoreq pc, r5, r3, asr r8 @ │ │ │ │ pop {r2, ip, sp, pc} │ │ │ │ vaba.s8 q12, q8, q8 │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ ldrmi r0, [r5], -r5, lsl #6 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7fa681f │ │ │ │ stmdavs fp!, {r0, r4, r6, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ movwls r4, #13826 @ 0x3602 │ │ │ │ @ instruction: 0xb32e4638 │ │ │ │ @ instruction: 0xf1069600 │ │ │ │ vrshl.s8 d16, d9, d10 │ │ │ │ - vaddw.s8 , q8, d28 │ │ │ │ + vaddw.s8 , q8, d20 │ │ │ │ @ instruction: 0xf8d80102 │ │ │ │ movwls r3, #8192 @ 0x2000 │ │ │ │ mvnvc pc, #64, 4 │ │ │ │ @ instruction: 0xf7f49501 │ │ │ │ - ldrtmi lr, [r0], -ip, lsr #19 │ │ │ │ + @ instruction: 0x4630e9b0 │ │ │ │ mcr2 7, 3, pc, cr10, cr15, {7} @ │ │ │ │ stmdacs r0, {r0, r1, r2, r9, sl, lr} │ │ │ │ @ instruction: 0xe792d197 │ │ │ │ ldrdeq pc, [r0], -r8 │ │ │ │ - ldm sl, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - eorscs pc, ip, sl, asr #4 │ │ │ │ + ldm lr, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + eorscs pc, r4, sl, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xff8cf7fa │ │ │ │ @ instruction: 0xf8c868a3 │ │ │ │ ldmiblt fp!, {} @ │ │ │ │ ldrb r2, [sl, -r0]! │ │ │ │ strvs lr, [r0], -sp, asr #19 │ │ │ │ - @ instruction: 0x11acf24a │ │ │ │ + @ instruction: 0x11a4f24a │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ vcgt.s8 d25, d0, d2 │ │ │ │ @ instruction: 0xf7f473e3 │ │ │ │ - ldrtmi lr, [r0], -r8, lsl #19 │ │ │ │ + ldrtmi lr, [r0], -ip, lsl #19 │ │ │ │ mcr2 7, 2, pc, cr6, cr15, {7} @ │ │ │ │ stmdacs r0, {r0, r1, r2, r9, sl, lr} │ │ │ │ svcge 0x0073f47f │ │ │ │ strb r2, [sp, -r0]! │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7fa681c │ │ │ │ strmi pc, [r2], -r5, lsl #30 │ │ │ │ strcc fp, [r9], -r6, lsl #2 │ │ │ │ vmax.s8 d20, d10, d16 │ │ │ │ - vmla.f d18, d0, d0[3] │ │ │ │ + vmla.f d18, d0, d0[1] │ │ │ │ strls r0, [r0], -r2, lsl #2 │ │ │ │ mvnsvc pc, #64, 4 │ │ │ │ - stmdb r6!, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb sl!, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ svclt 0x0000e7ce │ │ │ │ svcmi 0x00f0e92d │ │ │ │ addslt r2, fp, r0, lsl #6 │ │ │ │ movwcc lr, #18893 @ 0x49cd │ │ │ │ stmdavs r4, {r4, r6, r8, ip, sp, pc} │ │ │ │ ldrbtcc pc, [r0], r0, asr #4 @ │ │ │ │ streq pc, [r5], -r0, asr #5 │ │ │ │ @@ -12043,20 +12041,20 @@ │ │ │ │ stmdavs ip!, {r0, r2, r4, r5, r7, r8, r9, fp, sp, lr} │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ stmdacs r0, {r4, r5, r6, r7, r8, r9, fp, sp, lr} │ │ │ │ ldcvs 0, cr13, [r4], #-368 @ 0xfffffe90 │ │ │ │ rscle r2, sp, r0, lsl #24 │ │ │ │ tstcs r0, r2, lsl #30 │ │ │ │ movweq pc, #28692 @ 0x7014 @ │ │ │ │ - blcs 90fe0 │ │ │ │ - blcs d0fc0 │ │ │ │ - blcs 110fa8 │ │ │ │ - blcs 150f90 │ │ │ │ - blcs 190f78 │ │ │ │ - blcs 1d0f60 │ │ │ │ + blcs 90fd8 │ │ │ │ + blcs d0fb8 │ │ │ │ + blcs 110fa0 │ │ │ │ + blcs 150f88 │ │ │ │ + blcs 190f70 │ │ │ │ + blcs 1d0f58 │ │ │ │ tstphi r6, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ svccc 0x0004f852 │ │ │ │ eorsle r4, sp, fp, lsr #5 │ │ │ │ @ instruction: 0xf8523101 │ │ │ │ adcmi r3, fp, #4, 30 │ │ │ │ tstcc r1, r8, lsr r0 │ │ │ │ svccc 0x0004f852 │ │ │ │ @@ -12087,1337 +12085,1337 @@ │ │ │ │ strcs sp, [r0], #-482 @ 0xfffffe1e │ │ │ │ andslt r4, fp, r0, lsr #12 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ eorvs r6, ip, r4, ror ip │ │ │ │ andslt r4, fp, r0, lsr #12 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf10568b3 │ │ │ │ - blcs 1f004 <__time64@plt+0xdd1c> │ │ │ │ + blcs 1effc <__time64@plt+0xdd14> │ │ │ │ teqphi r1, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ stmdbne r8!, {r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ ldrdcs pc, [r4, -r9] │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ strcs r8, [r0, -r7, asr #3] │ │ │ │ strvc pc, [r2], #1289 @ 0x509 │ │ │ │ - blcs 2eaec <__time64@plt+0x1d804> │ │ │ │ + blcs 2eae4 <__time64@plt+0x1d7fc> │ │ │ │ addhi pc, r6, r0, asr #32 │ │ │ │ - blcs 37294 <__time64@plt+0x25fac> │ │ │ │ + blcs 3728c <__time64@plt+0x25fa4> │ │ │ │ addshi pc, ip, r0 │ │ │ │ tstcs r0, r0, asr r2 │ │ │ │ stmib sp, {r1, r2, fp, sp, pc}^ │ │ │ │ @ instruction: 0xf7f4bb04 │ │ │ │ - @ instruction: 0xf8cde8e2 │ │ │ │ - blge 1c9020 │ │ │ │ + @ instruction: 0xf8cde8e6 │ │ │ │ + blge 1c9018 │ │ │ │ stmiavs r0!, {r1, r3, r9, sp} │ │ │ │ @ instruction: 0xf7f74641 │ │ │ │ - ldmvs r3!, {r1, r2, r4, r5, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ + ldmvs r3!, {r1, r3, r4, r5, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ cmnle r6, r0, lsl #16 │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ tstcs r8, #-1073741799 @ 0xc0000019 │ │ │ │ strbmi sl, [r0], -r6, lsl #18 │ │ │ │ - bcc ff659940 │ │ │ │ - beq 199b44 │ │ │ │ + bcc ff659938 │ │ │ │ + beq 199b3c │ │ │ │ movwls pc, #31491 @ 0x7b03 @ │ │ │ │ @ instruction: 0x2114f8d3 │ │ │ │ @ instruction: 0xf94cf7fb │ │ │ │ @ instruction: 0x900468b3 │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ ldrcs r8, [r8], #-384 @ 0xfffffe80 │ │ │ │ strbmi sl, [r0], -r6, lsl #18 │ │ │ │ strls pc, [r7], #-2820 @ 0xfffff4fc │ │ │ │ @ instruction: 0x2110f8d4 │ │ │ │ @ instruction: 0xf93ef7fb │ │ │ │ @ instruction: 0x460168b3 │ │ │ │ - blcs 41088 <__time64@plt+0x2fda0> │ │ │ │ + blcs 41080 <__time64@plt+0x2fd98> │ │ │ │ tstphi fp, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0x3118f8d4 │ │ │ │ - bge 14964c │ │ │ │ + bge 149644 │ │ │ │ strtmi sl, [r8], -r5, lsl #18 │ │ │ │ ldmvs r3!, {r3, r4, r7, r8, r9, sl, lr} │ │ │ │ - blcs 2e89c <__time64@plt+0x1d5b4> │ │ │ │ + blcs 2e894 <__time64@plt+0x1d5ac> │ │ │ │ tstlt ip, r9, ror r1 │ │ │ │ ldr r6, [r5, -ip, lsr #32]! │ │ │ │ stmdbcs r0, {r0, r2, r8, fp, ip, pc} │ │ │ │ cmnphi r4, r0 @ p-variant is OBSOLETE │ │ │ │ stmdacs r0, {r2, fp, ip, pc} │ │ │ │ cmnphi r0, r0 @ p-variant is OBSOLETE │ │ │ │ stmdblt ip!, {r2, r4, r5, r7, r9, fp, sp, lr} │ │ │ │ stmdavs r4!, {r0, r1, r2, r5, r7, sp, lr, pc} │ │ │ │ @ instruction: 0x2c009905 │ │ │ │ adchi pc, r2, r0 │ │ │ │ @ instruction: 0xf7fa6860 │ │ │ │ - stmdacs r0, {r0, r1, r2, r3, fp, ip, sp, lr, pc} │ │ │ │ + stmdacs r0, {r0, r1, r4, fp, ip, sp, lr, pc} │ │ │ │ ldmvs r3!, {r0, r2, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ - blcs 35174 <__time64@plt+0x23e8c> │ │ │ │ + blcs 3516c <__time64@plt+0x23e84> │ │ │ │ svcge 0x001cf43f │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7fa681d │ │ │ │ ldmib sp, {r0, r3, r4, r5, r6, r7, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ stmib sp, {r2, r8, r9, ip}^ │ │ │ │ strmi r3, [r2], -r1, lsl #2 │ │ │ │ - teqpmi r8, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpmi r0, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ strls r4, [r0], #-1576 @ 0xfffff9d8 │ │ │ │ bicseq pc, r9, #64, 12 @ 0x4000000 │ │ │ │ - ldmda r8, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - blcs 56d00 │ │ │ │ + ldmda ip, {r2, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blcs 56cf8 │ │ │ │ @ instruction: 0xf854d15f │ │ │ │ smladcc r1, r8, pc, r3 @ │ │ │ │ sbcle r2, r3, r0, lsl #22 │ │ │ │ @ instruction: 0xe77668b3 │ │ │ │ - bcc ff659a14 │ │ │ │ - beq 199c18 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + bcc ff659a0c │ │ │ │ + beq 199c10 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrdge pc, [r0], -sl │ │ │ │ ldc2l 7, cr15, [r4, #1000] @ 0x3e8 │ │ │ │ strmi r9, [r2], -r0, lsl #14 │ │ │ │ - biccs pc, r0, sl, asr #4 │ │ │ │ + @ instruction: 0x21b8f24a │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrbmi r6, [r0], -r3, lsr #16 │ │ │ │ @ instruction: 0xf6409301 │ │ │ │ @ instruction: 0xf7f4037f │ │ │ │ - smmlar pc, r6, r8, lr @ │ │ │ │ + smmlar pc, sl, r8, lr @ │ │ │ │ andcs r2, r1, r0, lsr #2 │ │ │ │ stc2l 7, cr15, [ip, #1000]! @ 0x3e8 │ │ │ │ ldmib r4, {r5, r7, sp, lr}^ │ │ │ │ @ instruction: 0xf7f71200 │ │ │ │ - stmdacs r0, {r0, r1, r4, r5, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ + stmdacs r0, {r0, r1, r2, r4, r5, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ svcge 0x0058f43f │ │ │ │ - sbcscs pc, ip, #-1610612732 @ 0xa0000004 │ │ │ │ + sbcscs pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ orreq pc, lr, r0, asr #12 │ │ │ │ - @ instruction: 0xf9aaf7f4 │ │ │ │ + @ instruction: 0xf9aef7f4 │ │ │ │ strmi r6, [r2], -r3, lsl #16 │ │ │ │ @ instruction: 0xf43f42ab │ │ │ │ tstcs r1, r7, lsr #30 │ │ │ │ vmax.s8 q15, q8, q9 │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ @ instruction: 0xf6480305 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf8d30002 │ │ │ │ @ instruction: 0xf7fa9000 │ │ │ │ - blls 15c808 │ │ │ │ + blls 15c800 │ │ │ │ movwls r4, #13826 @ 0x3602 │ │ │ │ - asrcc pc, sl, #4 @ │ │ │ │ + orrscc pc, r8, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ movwls r9, #11013 @ 0x2b05 │ │ │ │ strls r4, [r0, -r8, asr #12] │ │ │ │ @ instruction: 0x03b2f640 │ │ │ │ @ instruction: 0xf7f39401 │ │ │ │ - stccs 15, cr14, [r0], {250} @ 0xfa │ │ │ │ + stccs 15, cr14, [r0], {254} @ 0xfe │ │ │ │ svcge 0x0068f47f │ │ │ │ vabd.s8 q15, q0, q12 │ │ │ │ @ instruction: 0xf2c03ad8 │ │ │ │ @ instruction: 0xf6480a05 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf8da0002 │ │ │ │ @ instruction: 0xf7faa000 │ │ │ │ stmib sp, {r0, r1, r3, r4, r5, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ strmi r7, [r2], -r0, lsl #16 │ │ │ │ - mvncc pc, sl, asr #4 │ │ │ │ + bicscc pc, r8, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrbmi r6, [r0], -r3, lsr #16 │ │ │ │ @ instruction: 0xf6409302 │ │ │ │ @ instruction: 0xf7f303c5 │ │ │ │ - @ instruction: 0xe784efdc │ │ │ │ + str lr, [r4, r0, ror #31] │ │ │ │ @ instruction: 0xf7fe9804 │ │ │ │ stmdavs r3, {r0, r2, r3, r9, fp, ip, sp, lr, pc}^ │ │ │ │ - blcs 2ea14 <__time64@plt+0x1d72c> │ │ │ │ + blcs 2ea0c <__time64@plt+0x1d724> │ │ │ │ sbchi pc, r5, r0 │ │ │ │ - blcs 374d8 <__time64@plt+0x261f0> │ │ │ │ + blcs 374d0 <__time64@plt+0x261e8> │ │ │ │ svcge 0x0040f43f │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7fa681e │ │ │ │ - blls 15c77c │ │ │ │ + blls 15c774 │ │ │ │ movwls r4, #9730 @ 0x2602 │ │ │ │ - blls 16eaf0 │ │ │ │ - msrmi (UNDEF: 108), sl │ │ │ │ + blls 16eae8 │ │ │ │ + msrmi (UNDEF: 100), sl │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ movwmi lr, #2509 @ 0x9cd │ │ │ │ mvneq pc, #64, 12 @ 0x4000000 │ │ │ │ - svc 0x00b4f7f3 │ │ │ │ + svc 0x00b8f7f3 │ │ │ │ vabd.s8 d30, d0, d20 │ │ │ │ @ instruction: 0xf2c03ad8 │ │ │ │ vpmax.s8 d16, d0, d5 │ │ │ │ vmul.f d17, d0, d0[6] │ │ │ │ @ instruction: 0xf6480905 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf8da0002 │ │ │ │ @ instruction: 0xf7fa4000 │ │ │ │ @ instruction: 0xf640fd35 │ │ │ │ @ instruction: 0x4602037a │ │ │ │ andhi pc, r4, sp, asr #17 │ │ │ │ strls r4, [r0, #-1568] @ 0xfffff9e0 │ │ │ │ - cmnpcs ip, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmnpcs r4, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - svc 0x0096f7f3 │ │ │ │ + svc 0x009af7f3 │ │ │ │ ldrdcc pc, [r4, -r9] │ │ │ │ @ instruction: 0xf43f2b00 │ │ │ │ ldmvs r3!, {r0, r2, r8, r9, sl, fp, sp, pc} │ │ │ │ vmin.s8 d30, d16, d19 │ │ │ │ @ instruction: 0xf2c039d8 │ │ │ │ @ instruction: 0xf6480905 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf8d90002 │ │ │ │ @ instruction: 0xf7faa000 │ │ │ │ - blls 19c6fc │ │ │ │ + blls 19c6f4 │ │ │ │ movwls r4, #1538 @ 0x602 │ │ │ │ @ instruction: 0xf6404650 │ │ │ │ vcgt.s8 d16, d26, d24 │ │ │ │ - vmla.f d19, d0, d0[3] │ │ │ │ + vmla.f d19, d0, d0[1] │ │ │ │ @ instruction: 0xf7f30102 │ │ │ │ - @ instruction: 0xf8d4ef78 │ │ │ │ - blcs 29724 <__time64@plt+0x1843c> │ │ │ │ + @ instruction: 0xf8d4ef7c │ │ │ │ + blcs 2971c <__time64@plt+0x18434> │ │ │ │ mcrge 4, 7, pc, cr6, cr15, {1} @ │ │ │ │ - bcs 37594 <__time64@plt+0x262ac> │ │ │ │ + bcs 3758c <__time64@plt+0x262a4> │ │ │ │ mrcge 4, 6, APSR_nzcv, cr7, cr15, {1} │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrdls pc, [r0], -r9 │ │ │ │ ldc2l 7, cr15, [r8], #1000 @ 0x3e8 │ │ │ │ strmi r9, [r2], -r4, lsl #22 │ │ │ │ strbmi r9, [r8], -r2, lsl #6 │ │ │ │ vqdmulh.s d25, d10, d5 │ │ │ │ - vmla.f d19, d0, d0[5] │ │ │ │ + vorr.i32 , #12 @ 0x0000000c │ │ │ │ movwls r0, #4354 @ 0x1102 │ │ │ │ @ instruction: 0xf6409700 │ │ │ │ @ instruction: 0xf7f303ad │ │ │ │ - @ instruction: 0xf8d4ef58 │ │ │ │ + @ instruction: 0xf8d4ef5c │ │ │ │ ssat r3, #29, r8, lsl #2 │ │ │ │ - bleq 659444 │ │ │ │ - bcc ff659c0c │ │ │ │ - beq 199e10 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + bleq 65943c │ │ │ │ + bcc ff659c04 │ │ │ │ + beq 199e08 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blls 21bf48 │ │ │ │ + blls 21bf40 │ │ │ │ ldrdmi pc, [r0], -sl │ │ │ │ ldc2l 7, cr15, [r6], {250} @ 0xfa │ │ │ │ @ instruction: 0xf6404602 │ │ │ │ @ instruction: 0x4620039e │ │ │ │ mvnscs pc, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdmi pc, [r4, -fp] │ │ │ │ strvc lr, [r2], #-2509 @ 0xfffff633 │ │ │ │ stmdapl r0, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - svc 0x0034f7f3 │ │ │ │ + svc 0x0038f7f3 │ │ │ │ @ instruction: 0x2114f8db │ │ │ │ strbmi sl, [r0], -r6, lsl #18 │ │ │ │ @ instruction: 0xffccf7fa │ │ │ │ @ instruction: 0x900468b3 │ │ │ │ @ instruction: 0xf43f2b00 │ │ │ │ @ instruction: 0xf8daae80 │ │ │ │ @ instruction: 0xf6484000 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fa0002 │ │ │ │ - blls 15c638 │ │ │ │ + blls 15c630 │ │ │ │ movwls r4, #1538 @ 0x602 │ │ │ │ vmax.s8 d20, d10, d16 │ │ │ │ - vbic.i32 d19, #8 @ 0x00000008 │ │ │ │ + vbic.i32 d19, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf6400102 │ │ │ │ @ instruction: 0xf7f303a4 │ │ │ │ - uqadd16 lr, sl, r6 │ │ │ │ - andsmi pc, r0, sl, asr #4 │ │ │ │ + uqadd16 lr, sl, sl │ │ │ │ + andmi pc, r8, sl, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f44641 │ │ │ │ - vadd.i8 , q5, │ │ │ │ - vrshr.s64 q9, q6, #64 │ │ │ │ + vadd.i8 , q5, │ │ │ │ + vrshr.s64 q9, q2, #64 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf6400002 │ │ │ │ @ instruction: 0xf7f401e1 │ │ │ │ - svclt 0x0000f88f │ │ │ │ + svclt 0x0000f893 │ │ │ │ @ instruction: 0x4605b5f8 │ │ │ │ @ instruction: 0xf7ff4608 │ │ │ │ @ instruction: 0xb1e0fd97 │ │ │ │ stccs 8, cr6, [r0], {68} @ 0x44 │ │ │ │ stccs 15, cr11, [r0, #-96] @ 0xffffffa0 │ │ │ │ stmdavc r2!, {r0, r1, r2, r4, ip, lr, pc} │ │ │ │ @ instruction: 0xf642b1aa │ │ │ │ - vqshl.s64 q9, q0, #0 │ │ │ │ + vqdmlsl.s q9, d16, d0[2] │ │ │ │ @ instruction: 0xf6490703 │ │ │ │ - vmov.i32 , #201326592 @ 0x0c000000 │ │ │ │ + vmov.i32 , #67108864 @ 0x04000000 │ │ │ │ @ instruction: 0xf8370602 │ │ │ │ @ instruction: 0x46313012 │ │ │ │ @ instruction: 0xf0034628 │ │ │ │ stmdblt r3, {r2, r3, r7, r8, r9} │ │ │ │ @ instruction: 0xf7fd225f │ │ │ │ @ instruction: 0xf814f9c3 │ │ │ │ - bcs 28ff4 <__time64@plt+0x17d0c> │ │ │ │ + bcs 28fec <__time64@plt+0x17d04> │ │ │ │ ldcllt 1, cr13, [r8, #964]! @ 0x3c4 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ ldrmi r4, [r5], -r8, lsl #13 │ │ │ │ strmi fp, [r7], -r3, lsl #1 │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ vhadd.s8 q12, q13, │ │ │ │ - vmlsl.s8 q10, d16, d20 │ │ │ │ + @ instruction: 0xf2c04a9c │ │ │ │ vpmax.s8 d16, d10, d2 │ │ │ │ - @ instruction: 0xf2c049b8 │ │ │ │ + @ instruction: 0xf2c049b0 │ │ │ │ vmla.i8 d16, d10, d2 │ │ │ │ - vmlsl.s q10, d16, d0[0] │ │ │ │ + @ instruction: 0xf2c046b8 │ │ │ │ strmi r0, [r4], -r2, lsl #12 │ │ │ │ stmdavs r4!, {r0, sp, lr, pc} │ │ │ │ stmdavs r3!, {r2, r4, r5, r6, r8, ip, sp, pc}^ │ │ │ │ rscsle r2, sl, r0, lsl #22 │ │ │ │ ldrbmi r6, [r2], -r0, ror #17 │ │ │ │ @ instruction: 0xf7fd4649 │ │ │ │ stmiavs r0!, {r0, r2, r3, r4, r7, r8, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7fd4631 │ │ │ │ stmdavs r4!, {r0, r3, r4, r7, r8, fp, ip, sp, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ ldrbtcc pc, [r0], #576 @ 0x240 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ - sbcmi pc, r8, #-1610612732 @ 0xa0000004 │ │ │ │ + sbcmi pc, r0, #-1610612732 @ 0xa0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - blmi ff659d80 │ │ │ │ - bleq d9f5c │ │ │ │ + blmi ff459d78 │ │ │ │ + bleq d9f54 │ │ │ │ vqdmulh.s q11, q5, q8 │ │ │ │ - @ instruction: 0xf2c04af8 │ │ │ │ + @ instruction: 0xf2c04af0 │ │ │ │ stmib sp, {r1, r9, fp}^ │ │ │ │ ldrmi r7, [r1], r0, lsl #10 │ │ │ │ @ instruction: 0xb128463d │ │ │ │ - blcs 37620 <__time64@plt+0x26338> │ │ │ │ + blcs 37618 <__time64@plt+0x26330> │ │ │ │ stmdavs sp!, {r1, r2, r3, r4, r6, r8, ip, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #26 │ │ │ │ ldmib sp, {r5, r6, r8, r9, fp, sp, lr}^ │ │ │ │ bicslt r7, r0, r0, lsl #10 │ │ │ │ - bmi ff259db0 │ │ │ │ - beq d9f8c │ │ │ │ - stmdbpl r0, {r1, r3, r6, r9, ip, sp, lr, pc} │ │ │ │ + bmi ff059da8 │ │ │ │ + beq d9f84 │ │ │ │ + ldmibmi r8!, {r1, r3, r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ ldrtmi r2, [fp], r0, lsl #12 │ │ │ │ @ instruction: 0xf850e006 │ │ │ │ strcc r0, [r1], -r6, lsr #32 │ │ │ │ @ instruction: 0xf966f7fd │ │ │ │ @ instruction: 0xb1286b60 │ │ │ │ strtmi r6, [fp], -r7, lsr #16 │ │ │ │ @ instruction: 0x46494652 │ │ │ │ ldmle r2!, {r0, r1, r2, r4, r5, r7, r9, lr}^ │ │ │ │ svccs 0x0000465f │ │ │ │ vhadd.s8 , q5, q13 │ │ │ │ - vqdmlsl.s , d0, d28 │ │ │ │ + vqdmlsl.s , d0, d20 │ │ │ │ vqdmulh.s d16, d9, d2 │ │ │ │ - vmull.s q11, d16, d0[3] │ │ │ │ - blvs 18dfcd4 │ │ │ │ + vmull.s q11, d16, d0[1] │ │ │ │ + blvs 18dfccc │ │ │ │ stmdbeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ ldmdavs pc!, {r1, sp, lr, pc} @ │ │ │ │ subsle r2, ip, r0, lsl #30 │ │ │ │ - bcs 376c4 <__time64@plt+0x263dc> │ │ │ │ + bcs 376bc <__time64@plt+0x263d4> │ │ │ │ ldmvs sl!, {r0, r3, r4, r5, r6, r7, ip, lr, pc} │ │ │ │ rsbsle r2, r5, r0, lsl #20 │ │ │ │ @ instruction: 0xf8c76855 │ │ │ │ stccs 0, cr9, [r0, #-16] │ │ │ │ - blcs 4d150 <__time64@plt+0x3be68> │ │ │ │ + blcs 4d148 <__time64@plt+0x3be60> │ │ │ │ strcs sp, [r0], -pc, ror #1 │ │ │ │ strle r0, [r6], #-2026 @ 0xfffff816 │ │ │ │ stmdaeq sp!, {r0, r1, r5, r6, r8, r9, fp, sp, lr}^ │ │ │ │ - blcs 2ad10 <__time64@plt+0x19a28> │ │ │ │ + blcs 2ad08 <__time64@plt+0x19a20> │ │ │ │ strbeq sp, [sl, r7, ror #1]! │ │ │ │ ldmibpl r8, {r3, r4, r5, r6, r7, r8, sl, ip, lr, pc} │ │ │ │ ldrbmi r4, [r9], -r2, asr #12 │ │ │ │ @ instruction: 0xf7fd086d │ │ │ │ - blvs 191b9d0 │ │ │ │ + blvs 191b9c8 │ │ │ │ ldmibpl r8, {r0, r3, r4, r5, r7, fp, sp, lr} │ │ │ │ @ instruction: 0xff48f7ff │ │ │ │ ldrbmi r6, [r1], -r3, ror #22 │ │ │ │ @ instruction: 0x36045998 │ │ │ │ @ instruction: 0xf924f7fd │ │ │ │ - blcs 382b8 <__time64@plt+0x26fd0> │ │ │ │ + blcs 382b0 <__time64@plt+0x26fc8> │ │ │ │ stccs 15, cr11, [r0, #-96] @ 0xffffffa0 │ │ │ │ strb sp, [lr, r0, ror #3] │ │ │ │ - blcs 377e4 <__time64@plt+0x264fc> │ │ │ │ + blcs 377dc <__time64@plt+0x264f4> │ │ │ │ ldmdavs lr, {r0, r2, r3, r4, r7, ip, lr, pc}^ │ │ │ │ addsle r2, sl, r0, lsl #28 │ │ │ │ ldrbeq r2, [r1, r0, lsl #14]! │ │ │ │ ldmdaeq r6!, {r0, r1, sl, ip, lr, pc}^ │ │ │ │ ldrbeq r3, [r1, r4, lsl #14]! │ │ │ │ @ instruction: 0x464ad5fb │ │ │ │ strbmi r5, [r3], -r0, asr #19 │ │ │ │ @ instruction: 0xf7fd4659 │ │ │ │ - blvs 191b988 │ │ │ │ + blvs 191b980 │ │ │ │ ldmibpl r8, {r0, r3, r5, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xff24f7ff │ │ │ │ ldrbmi r6, [r1], -r3, ror #22 │ │ │ │ @ instruction: 0xf7fd59d8 │ │ │ │ - blvs 185b974 │ │ │ │ + blvs 185b96c │ │ │ │ ldmdaeq r1!, {r0, r1, r3, r4, r5, r8, sl, fp, ip}^ │ │ │ │ strbeq sp, [sl, r4] │ │ │ │ ldmeq r6!, {r0, r1, r2, sl, ip, lr, pc} │ │ │ │ strb r3, [r0, r8, lsl #14]! │ │ │ │ stccs 8, cr6, [r0, #-180] @ 0xffffff4c │ │ │ │ svcge 0x0073f47f │ │ │ │ @ instruction: 0x460ee778 │ │ │ │ bfc r4, #12, #19 │ │ │ │ bicslt r6, r3, r3, ror #22 │ │ │ │ - ldrtpl pc, [r8], -sl, asr #4 @ │ │ │ │ + ldrtpl pc, [r0], -sl, asr #4 @ │ │ │ │ streq pc, [r2], -r0, asr #5 │ │ │ │ - strbpl pc, [r0, -sl, asr #4] @ │ │ │ │ + ldrpl pc, [r8, -sl, asr #4]! │ │ │ │ streq pc, [r2, -r0, asr #5] │ │ │ │ and r2, ip, r0, lsl #10 │ │ │ │ eoreq pc, r5, r3, asr r8 @ │ │ │ │ @ instruction: 0xf8e0f7fd │ │ │ │ ldrtmi r6, [r9], -r3, ror #22 │ │ │ │ eoreq pc, r5, r3, asr r8 @ │ │ │ │ @ instruction: 0xf7fd3501 │ │ │ │ - blvs 191b924 │ │ │ │ + blvs 191b91c │ │ │ │ stmdavs r2!, {r0, r1, r3, r4, r8, ip, sp, pc} │ │ │ │ adcmi r4, sl, #51380224 @ 0x3100000 │ │ │ │ andlt sp, r3, lr, ror #17 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xe77e607a │ │ │ │ ldrbtcc pc, [r0], #576 @ 0x240 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ stmdacs r0, {r5, r6, r8, r9, fp, sp, lr} │ │ │ │ svcge 0x0050f47f │ │ │ │ svclt 0x0000e7f1 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ - blvs 2eee28 │ │ │ │ + blvs 2eee20 │ │ │ │ movwls fp, #8351 @ 0x209f │ │ │ │ @ instruction: 0x461db31b │ │ │ │ - blcs 38268 <__time64@plt+0x26f80> │ │ │ │ + blcs 38260 <__time64@plt+0x26f78> │ │ │ │ @ instruction: 0xf649d1fb │ │ │ │ - vorr.i32 d19, #4 @ 0x00000004 │ │ │ │ - bvs 1a1da10 │ │ │ │ + vaddw.s8 , q0, d12 │ │ │ │ + bvs 1a1da08 │ │ │ │ stc2 0, cr15, [lr, #12]! │ │ │ │ andslt fp, pc, r0, lsl r1 @ │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - orrscc pc, r4, r9, asr #4 │ │ │ │ + orrcc pc, ip, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf0036a68 │ │ │ │ stmdacs r0, {r0, r1, r5, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ stmdbvs fp!, {r0, r1, r4, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ andseq pc, r8, r6, lsl #2 │ │ │ │ vmul.i8 q11, q5, q9 │ │ │ │ - vmla.f d21, d0, d0[1] │ │ │ │ + vbic.i32 d21, #12 @ 0x0000000c │ │ │ │ movwls r0, #258 @ 0x102 │ │ │ │ - blx ff65b628 │ │ │ │ + blx ff65b620 │ │ │ │ ldrmi lr, [r9], -r7, ror #15 │ │ │ │ ldrmi r4, [r7], -r0, lsl #13 │ │ │ │ subcs sl, ip, #720896 @ 0xb0000 │ │ │ │ - stcl 7, cr15, [r8, #972] @ 0x3cc │ │ │ │ + stcl 7, cr15, [ip, #972] @ 0x3cc │ │ │ │ svcne 0x001a6833 │ │ │ │ - blcs 6c278 │ │ │ │ - bcs 8d478 │ │ │ │ + blcs 6c270 │ │ │ │ + bcs 8d470 │ │ │ │ movwhi pc, #20992 @ 0x5200 @ │ │ │ │ @ instruction: 0xf7ff69b0 │ │ │ │ - bvs 1d1c768 │ │ │ │ + bvs 1d1c760 │ │ │ │ andls r9, sp, r9 │ │ │ │ - blcs 4228c <__time64@plt+0x30fa4> │ │ │ │ + blcs 42284 <__time64@plt+0x30f9c> │ │ │ │ rschi pc, r4, #0 │ │ │ │ @ instruction: 0xf649461d │ │ │ │ - vrsra.s64 q9, q8, #64 │ │ │ │ + vqdmlal.s q9, d16, d0[6] │ │ │ │ movwls r0, #21250 @ 0x5302 │ │ │ │ - tstpcc r0, #76546048 @ p-variant is OBSOLETE @ 0x4900000 │ │ │ │ + movwcc pc, #34377 @ 0x8649 @ │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ vcgt.s8 d25, d10, d4 │ │ │ │ - @ instruction: 0xf2c05afc │ │ │ │ - blls 9fe98 │ │ │ │ - blcs ff95afb8 │ │ │ │ - bleq da198 │ │ │ │ + @ instruction: 0xf2c05af4 │ │ │ │ + blls 9fe90 │ │ │ │ + blcs ff75afb0 │ │ │ │ + bleq da190 │ │ │ │ movwls r4, #13977 @ 0x3699 │ │ │ │ movwcc lr, #27085 @ 0x69cd │ │ │ │ ldrbmi r6, [r1], -ip, ror #16 │ │ │ │ @ instruction: 0xf7f34620 │ │ │ │ - stmdacs r0, {r5, r7, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r2, r5, r7, sl, fp, sp, lr, pc} │ │ │ │ mvnhi pc, r0, asr #32 │ │ │ │ - blcs 77960 │ │ │ │ + blcs 77958 │ │ │ │ stmiavs fp!, {r2, r8, r9, sl, fp, ip, sp, pc}^ │ │ │ │ andle r9, lr, r7, lsl #6 │ │ │ │ @ instruction: 0x46204659 │ │ │ │ - ldc 7, cr15, [r2], {243} @ 0xf3 │ │ │ │ + ldc 7, cr15, [r6], {243} @ 0xf3 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ stmdbls r4, {r0, r5, r6, r7, r8, pc} │ │ │ │ @ instruction: 0xf7f34620 │ │ │ │ - stmdacs r0, {r2, r3, r7, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r4, r7, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf049bf08 │ │ │ │ stmdavs sp!, {r0, r8, fp} │ │ │ │ bicsle r2, pc, r0, lsl #26 │ │ │ │ andcc lr, r6, #3620864 @ 0x374000 │ │ │ │ svclt 0x00183b00 │ │ │ │ - bcs 262f0 <__time64@plt+0x15008> │ │ │ │ + bcs 262e8 <__time64@plt+0x15000> │ │ │ │ movwcs fp, #3864 @ 0xf18 │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ stcls 1, cr8, [r3, #-908] @ 0xfffffc74 │ │ │ │ svclt 0x00182d00 │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ @ instruction: 0xf1068250 │ │ │ │ vqshl.s8 d16, d8, d10 │ │ │ │ - vmla.f d21, d16, d0[6] │ │ │ │ + vmla.f d21, d16, d0[4] │ │ │ │ strtmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx 1b5b700 │ │ │ │ + blx 1b5b6f8 │ │ │ │ movwls r6, #35443 @ 0x8a73 │ │ │ │ movwls r9, #39693 @ 0x9b0d │ │ │ │ - blls 242b28 │ │ │ │ - bicsvs pc, r0, r9, asr #12 │ │ │ │ + blls 242b20 │ │ │ │ + bicvs pc, r8, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ movwls r9, #59401 @ 0xe809 │ │ │ │ - strvs pc, [r8, #-586] @ 0xfffffdb6 │ │ │ │ + strvs pc, [r0, #-586] @ 0xfffffdb6 │ │ │ │ streq pc, [r2, #-704] @ 0xfffffd40 │ │ │ │ tstls r7, #733184 @ 0xb3000 │ │ │ │ ldrls r2, [r6], #-768 @ 0xfffffd00 │ │ │ │ rsbscc pc, r5, sp, lsl #17 │ │ │ │ mvnscc pc, #-1342177276 @ 0xb0000004 │ │ │ │ movweq pc, #4800 @ 0x12c0 @ │ │ │ │ movwls r9, #46860 @ 0xb70c │ │ │ │ - movwvs pc, #49738 @ 0xc24a @ │ │ │ │ + movwvs pc, #16970 @ 0x424a @ │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ rsbhi pc, r4, sp, asr #17 │ │ │ │ vcge.s8 d25, d14, d1 │ │ │ │ - vbic.i32 q9, #1024 @ 0x00000400 │ │ │ │ + vqdmlal.s q9, d0, d0[7] │ │ │ │ ldrls r0, [r0, #-770] @ 0xfffffcfe │ │ │ │ vcge.s8 d25, d10, d3 │ │ │ │ - vrsra.s64 q8, q6, #64 │ │ │ │ + vrsra.s64 q8, q2, #64 │ │ │ │ movwls r0, #62210 @ 0xf302 │ │ │ │ @ instruction: 0xfffef7fc │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vaddw.s8 q11, q0, d16 │ │ │ │ + vorr.i32 d22, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ ldmdavs sl!, {r0, r1, r2, r4, r5, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ strbmi r9, [r1], -sp, lsl #16 │ │ │ │ stc2 7, cr15, [sl], #-1012 @ 0xfffffc0c │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vaddw.s8 q11, q0, d24 │ │ │ │ + vaddw.s8 q11, q0, d16 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdals sp, {r0, r1, r3, r5, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - teqpvs r8, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpvs r0, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xffe4f7fc │ │ │ │ ldrtmi r9, [r1], -sp, lsl #16 │ │ │ │ mcrr2 7, 15, pc, r6, cr13 @ │ │ │ │ stmdals sp, {r0, r1, r8, r9, fp, ip, pc} │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ vand q12, q13, q13 │ │ │ │ - vmlal.s q10, d16, d0[1] │ │ │ │ - @ instruction: 0xf64a0202 │ │ │ │ - vaddw.s8 q8, q0, d4 │ │ │ │ + vrshr.s64 d20, d28, #64 │ │ │ │ + vhsub.s8 d16, d10, d2 │ │ │ │ + vsra.s64 , q14, #64 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdals sp, {r0, r4, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fd4631 │ │ │ │ stmdals sp, {r0, r1, r4, r5, sl, fp, ip, sp, lr, pc} │ │ │ │ - tstpeq r0, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpeq r8, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xffc6f7fc │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ @ instruction: 0xf0002b0a │ │ │ │ stmdals sp, {r4, r5, r9, pc} │ │ │ │ - asrvc pc, fp, #4 @ │ │ │ │ + orrsvc pc, r8, fp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xffbaf7fc │ │ │ │ ldrtmi r9, [r1], -sp, lsl #16 │ │ │ │ ldc2 7, cr15, [ip], {253} @ 0xfd │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vorr.i32 q11, #12 @ 0x0000000c │ │ │ │ + vorr.i32 q11, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ - blls dd6d0 │ │ │ │ + blls dd6c8 │ │ │ │ ldmvs sl!, {r0, r2, r3, fp, ip, pc}^ │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ vrhadd.s8 d24, d26, d22 │ │ │ │ - vbic.i32 q11, #8 @ 0x00000008 │ │ │ │ + vbic.i32 q11, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ ldmdavs sl!, {r0, r1, r5, r7, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - bcs 43864 <__time64@plt+0x3257c> │ │ │ │ + bcs 4385c <__time64@plt+0x32574> │ │ │ │ orrhi pc, pc, r0 │ │ │ │ - orrvc pc, ip, sl, asr #4 │ │ │ │ + orrvc pc, r4, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xff98f7fc │ │ │ │ strbmi r9, [r1], -sp, lsl #16 │ │ │ │ ldc2l 7, cr15, [r2, #-1012]! @ 0xfffffc0c │ │ │ │ @ instruction: 0xf649980d │ │ │ │ - vsra.s64 d21, d8, #64 │ │ │ │ + vsra.s64 d21, d0, #64 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ vmax.f32 d31, d26, d13 │ │ │ │ - vaddw.s8 q11, q8, d16 │ │ │ │ + vsra.s64 d22, d8, #64 │ │ │ │ stmdals sp, {r1, r8} │ │ │ │ @ instruction: 0xff86f7fc │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vsra.s64 d22, d20, #64 │ │ │ │ + vaddw.s8 q11, q8, d28 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdbls r3, {r0, r1, r2, r3, r4, r5, r6, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ vadd.i8 d26, d10, d11 │ │ │ │ - vrshr.s64 , q14, #64 │ │ │ │ + vrshr.s64 , q10, #64 │ │ │ │ vhsub.s8 d16, d10, d2 │ │ │ │ - vqdmlal.s q11, d16, d0[1] │ │ │ │ + vrsra.s64 d22, d28, #64 │ │ │ │ tstls r2, #134217728 @ 0x8000000 │ │ │ │ stc2l 7, cr15, [r2], #1012 @ 0x3f4 │ │ │ │ @ instruction: 0xf649980d │ │ │ │ - vaddw.s8 q9, q0, d20 │ │ │ │ + vorr.i32 d18, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stcls 15, cr15, [r6], {107} @ 0x6b │ │ │ │ rsble r2, r9, r0, lsl #24 │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vmla.f d22, d16, d0[3] │ │ │ │ + vmla.f d22, d16, d0[1] │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdals sp, {r0, r5, r6, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - mvnvs pc, sl, asr #4 │ │ │ │ + bicsvs pc, r8, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xff5af7fc │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vsra.s64 q11, q8, #64 │ │ │ │ + vmla.f d22, d16, d0[6] │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ ldmdavs r3!, {r0, r1, r4, r6, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - blcs 183904 │ │ │ │ + blcs 1838fc │ │ │ │ @ instruction: 0xf0006973 │ │ │ │ @ instruction: 0xf64c81a5 │ │ │ │ - vrshr.s64 , q0, #64 │ │ │ │ + vmlal.s , d16, d0[2] │ │ │ │ vhsub.s8 d16, d10, d2 │ │ │ │ - vsra.s64 q11, q14, #64 │ │ │ │ + vsra.s64 q11, q10, #64 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ strtmi pc, [r1], -r3, asr #30 │ │ │ │ @ instruction: 0xf649a80b │ │ │ │ - vmlal.s q9, d16, d0[5] │ │ │ │ + vrshr.s64 q9, q6, #64 │ │ │ │ ldrls r0, [r2, #-514] @ 0xfffffdfe │ │ │ │ stc2 7, cr15, [sl], #1012 @ 0x3f4 │ │ │ │ @ instruction: 0xf649980d │ │ │ │ - vaddw.s8 q9, q0, d20 │ │ │ │ + vorr.i32 d18, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdals sp, {r0, r1, r4, r5, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - tstpvc ip, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + tstpvc r4, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xff2cf7fc │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vmla.f d23, d0, d0[0] │ │ │ │ + vbic.i32 d23, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ ldmvs sl!, {r0, r2, r5, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vorr.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.f d23, d0, d0[3] │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ ldmdavs sl!, {r0, r2, r3, r4, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - msrcs R12_usr, r9 │ │ │ │ + tstpcs ip, r9, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ cmnlt r2, sp, lsl #16 │ │ │ │ - cmnpvc r0, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ + msrvc (UNDEF: 104), sl │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xff10f7fc │ │ │ │ strbmi r9, [r1], -sp, lsl #16 │ │ │ │ stc2l 7, cr15, [sl], #1012 @ 0x3f4 │ │ │ │ @ instruction: 0xf649980d │ │ │ │ - vaddw.s8 q9, q0, d20 │ │ │ │ + vorr.i32 d18, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ vmax.f32 d31, d10, d5 │ │ │ │ - vaddw.s8 , q8, d0 │ │ │ │ + vbic.i32 , #8 @ 0x00000008 │ │ │ │ stmdals sp, {r1, r8} │ │ │ │ mrc2 7, 7, pc, cr14, cr12, {7} │ │ │ │ stmdals sp, {r1, r8, r9, fp, ip, pc} │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ ldmvs sl!, {r0, r1, r2, r3, r5, r6, r7, pc}^ │ │ │ │ - orrvs pc, ip, sl, asr #4 │ │ │ │ + orrvs pc, r4, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mrc2 7, 7, pc, cr2, cr12, {7} │ │ │ │ vtst.8 q11, q5, q13 │ │ │ │ - vaddw.s8 , q8, d16 │ │ │ │ + vsra.s64 d23, d8, #64 │ │ │ │ stmdals sp, {r1, r8} │ │ │ │ vand , q5, q9 │ │ │ │ - vaddw.s8 , q8, d12 │ │ │ │ + vaddw.s8 , q8, d4 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdals sp, {r0, r2, r5, r6, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fd4641 │ │ │ │ stmdals sp, {r0, r1, r2, r3, r4, r5, r7, sl, fp, ip, sp, lr, pc} │ │ │ │ - asrvc pc, sl, #4 @ │ │ │ │ + orrsvc pc, r8, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mrc2 7, 6, pc, cr10, cr12, {7} │ │ │ │ - @ instruction: 0x61acf24a │ │ │ │ + @ instruction: 0x61a4f24a │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fc980d │ │ │ │ stmdals sp, {r0, r1, r4, r6, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - bicvc pc, r0, sl, asr #4 │ │ │ │ + @ instruction: 0x71b8f24a │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mcr2 7, 6, pc, cr12, cr12, {7} @ │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ ldrls r2, [r2, #-518] @ 0xfffffdfa │ │ │ │ andsls r2, r4, #10240 @ 0x2800 │ │ │ │ adchi pc, r7, r0 │ │ │ │ stmdbge fp, {r4, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xff20f7fd │ │ │ │ @ instruction: 0xb1ac9c03 │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vsra.s64 , q4, #64 │ │ │ │ + vsra.s64 , q0, #64 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ @ instruction: 0x4621feb7 │ │ │ │ vadd.i8 d26, d10, d11 │ │ │ │ - vrshr.s64 , q14, #64 │ │ │ │ + vrshr.s64 , q10, #64 │ │ │ │ @ instruction: 0xf7fd0202 │ │ │ │ @ instruction: 0xf649fc1f │ │ │ │ - vaddw.s8 q9, q0, d20 │ │ │ │ + vorr.i32 d18, #12 @ 0x0000000c │ │ │ │ stmdals sp, {r1, r8} │ │ │ │ mcr2 7, 5, pc, cr8, cr12, {7} @ │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vmla.f d23, d16, d0[5] │ │ │ │ + vsra.s64 , q6, #64 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ - blls dd4b4 │ │ │ │ + blls dd4ac │ │ │ │ vand d27, d10, d19 │ │ │ │ - vmla.f d23, d16, d0[7] │ │ │ │ + vmla.f d23, d16, d0[5] │ │ │ │ stmdals sp, {r1, r8} │ │ │ │ mrc2 7, 4, pc, cr8, cr12, {7} │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vmla.f d23, d16, d0[6] │ │ │ │ + vmla.f d23, d16, d0[4] │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ @ instruction: 0xf8d8fe91 │ │ │ │ - blcs 2a9a54 │ │ │ │ + blcs 2a9a4c │ │ │ │ @ instruction: 0xf1b9d046 │ │ │ │ @ instruction: 0xf43f0f00 │ │ │ │ ldmdavs r9!, {r3, r4, r6, r7, r8, sl, fp, sp, pc} │ │ │ │ strbmi sl, [r0], -fp, lsl #20 │ │ │ │ @ instruction: 0xf818f7ff │ │ │ │ ldrtmi r9, [sl], -sp, lsl #16 │ │ │ │ @ instruction: 0xf7fd4641 │ │ │ │ strb pc, [ip, #2893] @ 0xb4d @ │ │ │ │ @ instruction: 0x46204659 │ │ │ │ - b feddba48 │ │ │ │ + b feedba40 │ │ │ │ stmiavs fp!, {r4, r5, r8, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf47f2b01 │ │ │ │ stmiavs fp!, {r1, r5, r9, sl, fp, sp, pc}^ │ │ │ │ strt r9, [r6], -r6, lsl #6 │ │ │ │ strtmi r9, [r0], -r5, lsl #18 │ │ │ │ - b feadba60 │ │ │ │ + b febdba58 │ │ │ │ stmiavs fp!, {r3, r5, r8, fp, ip, sp, pc} │ │ │ │ tstle r2, r1, lsl #22 │ │ │ │ movwls r6, #14571 @ 0x38eb │ │ │ │ stmdbls r4, {r0, r1, r3, r4, r9, sl, sp, lr, pc} │ │ │ │ @ instruction: 0xf7f34620 │ │ │ │ - stmdavs sp!, {r5, r7, r9, fp, sp, lr, pc} │ │ │ │ + stmdavs sp!, {r2, r5, r7, r9, fp, sp, lr, pc} │ │ │ │ svclt 0x00082800 │ │ │ │ stmdbeq r1, {r0, r3, r6, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf47f2d00 │ │ │ │ @ instruction: 0xe611adf3 │ │ │ │ ldreq pc, [r8], #-262 @ 0xfffffefa │ │ │ │ - bicpl pc, r8, sl, asr #4 │ │ │ │ + bicpl pc, r0, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ ldmib sp, {r0, r1, r2, r3, r7, fp, ip, sp, lr, pc}^ │ │ │ │ - bcs 2a2dc <__time64@plt+0x18ff4> │ │ │ │ + bcs 2a2d4 <__time64@plt+0x18fec> │ │ │ │ sadd16mi fp, r3, r8 │ │ │ │ - bvs 1d026e4 │ │ │ │ - blls 382700 │ │ │ │ + bvs 1d026dc │ │ │ │ + blls 3826f8 │ │ │ │ ldr r9, [ip], -r9, lsl #6 │ │ │ │ ldrdmi pc, [r0], -r8 @ │ │ │ │ adcsle r2, r4, r0, lsl #24 │ │ │ │ stmdavs r3, {r5, r7, fp, sp, lr} │ │ │ │ andsle r2, r0, r6, lsl #22 │ │ │ │ - blcc 265760 │ │ │ │ + blcc 265758 │ │ │ │ svclt 0x00882b01 │ │ │ │ ldmdale r6, {r0, r9, fp, sp} │ │ │ │ - bge 2f7be8 │ │ │ │ + bge 2f7be0 │ │ │ │ @ instruction: 0xffc8f7fe │ │ │ │ stccs 8, cr6, [r0], {36} @ 0x24 │ │ │ │ stmiavs r0!, {r0, r1, r5, r7, ip, lr, pc} │ │ │ │ - blcs 1b7b20 │ │ │ │ + blcs 1b7b18 │ │ │ │ stmdbvs r1, {r1, r2, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ svcne 0x001a680b │ │ │ │ - blcs 6c744 │ │ │ │ - bcs 8d944 │ │ │ │ + blcs 6c73c │ │ │ │ + bcs 8d93c │ │ │ │ stmdals sp, {r0, r1, fp, ip, lr, pc} │ │ │ │ @ instruction: 0xf7fd463a │ │ │ │ stmdavs r4!, {r0, r1, r2, r3, r5, r6, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ bicsle r2, fp, r0, lsl #24 │ │ │ │ ldmdavs fp!, {r0, r1, r2, r3, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ - bicvc pc, r8, sl, asr #4 │ │ │ │ + bicvc pc, r0, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stmdals sp, {r8, r9, ip, pc} │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ mrc2 7, 0, pc, cr0, cr12, {7} │ │ │ │ @ instruction: 0xf649e74e │ │ │ │ - vsra.s64 d21, d8, #64 │ │ │ │ + vsra.s64 d21, d0, #64 │ │ │ │ ldrbt r0, [sl], -r2, lsl #2 │ │ │ │ - @ instruction: 0x71a8f24a │ │ │ │ + asrvc pc, sl, #4 @ │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ mcr2 7, 0, pc, cr4, cr12, {7} @ │ │ │ │ vabd.s8 d30, d10, d31 │ │ │ │ - vaddw.s8 q11, q8, d12 │ │ │ │ + vaddw.s8 q11, q8, d4 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ ldmdavs sl!, {r0, r2, r3, r4, r5, r6, r7, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - bcs 43bb0 <__time64@plt+0x328c8> │ │ │ │ + bcs 43ba8 <__time64@plt+0x328c0> │ │ │ │ vhadd.s8 , q5, │ │ │ │ - vaddw.s8 , q8, d12 │ │ │ │ + vaddw.s8 , q8, d4 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdals sp, {r0, r1, r4, r5, r6, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fd4641 │ │ │ │ stmdals sp, {r0, r2, r3, r6, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ - orrspl pc, r8, r9, asr #12 │ │ │ │ + orrspl pc, r0, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2l 7, cr15, [r8, #1008]! @ 0x3f0 │ │ │ │ stccs 6, cr14, [r0, #-384] @ 0xfffffe80 │ │ │ │ @ instruction: 0xf106d04e │ │ │ │ strls r0, [r2, #-1048] @ 0xfffffbe8 │ │ │ │ @ instruction: 0xf649e5b7 │ │ │ │ - vrshr.s64 q9, q2, #64 │ │ │ │ - @ instruction: 0xf64a0202 │ │ │ │ - vaddw.s8 q8, q0, d4 │ │ │ │ + vmlal.s q9, d16, d0[3] │ │ │ │ + vhsub.s8 d16, d10, d2 │ │ │ │ + vsra.s64 , q14, #64 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdals sp, {r0, r1, r2, r4, r6, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fd4631 │ │ │ │ stmdals sp, {r0, r3, r4, r5, r9, fp, ip, sp, lr, pc} │ │ │ │ - tstpeq r0, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpeq r8, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2l 7, cr15, [ip, #1008] @ 0x3f0 │ │ │ │ stmdals sp, {r1, r3, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ - tstpeq ip, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpeq r4, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2l 7, cr15, [r4, #1008] @ 0x3f0 │ │ │ │ cmplt r2, sl, ror r8 │ │ │ │ vadd.i8 d25, d10, d13 │ │ │ │ - vmla.f d22, d0, d0[7] │ │ │ │ + vmla.f d22, d0, d0[5] │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdals sp, {r0, r1, r3, r4, r5, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fd4641 │ │ │ │ stmdals sp, {r0, r2, r4, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ - orrspl pc, r8, r9, asr #12 │ │ │ │ + orrspl pc, r0, r9, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldc2 7, cr15, [r0, #1008]! @ 0x3f0 │ │ │ │ @ instruction: 0xf649e6db │ │ │ │ - vsra.s64 d21, d8, #64 │ │ │ │ + vsra.s64 d21, d0, #64 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ strt pc, [r1], -r9, lsr #27 │ │ │ │ - sbcpl pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ + sbcpl pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ mvnsvs pc, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldc2 7, cr15, [lr, #1008] @ 0x3f0 │ │ │ │ ldrb r9, [r9], -r6, lsl #18 │ │ │ │ @ instruction: 0xf1064699 │ │ │ │ movwls r0, #13336 @ 0x3418 │ │ │ │ strb r9, [ip, #-774]! @ 0xfffffcfa │ │ │ │ @ instruction: 0xf1069b07 │ │ │ │ movwls r0, #13336 @ 0x3418 │ │ │ │ vrshl.s8 q15, , q5 │ │ │ │ - vmlal.s q11, d0, d0[0] │ │ │ │ + vmvn.i32 d22, #2048 @ 0x00000800 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ vst4.8 {d16-d19}, [pc], r2 │ │ │ │ @ instruction: 0xf7f3615e │ │ │ │ - vfma.f32 d31, d10, d17 │ │ │ │ - vsubl.s8 , d16, d24 │ │ │ │ + vfma.f32 d31, d10, d21 │ │ │ │ + vsubl.s8 , d16, d16 │ │ │ │ @ instruction: 0xf6480202 │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf6400002 │ │ │ │ @ instruction: 0xf7f341df │ │ │ │ - svclt 0x0000fc25 │ │ │ │ + svclt 0x0000fc29 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ strmi r4, [sp], -r7, lsl #12 │ │ │ │ ldrmi fp, [r0], r9, lsl #1 │ │ │ │ - msreq R8_fiq, sl │ │ │ │ + msreq R8_usr, sl │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fc6952 │ │ │ │ @ instruction: 0xf64afd6b │ │ │ │ - vbic.i32 d16, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 q8, q0, d28 │ │ │ │ ldrtmi r0, [r8], -r2, lsl #2 │ │ │ │ stc2l 7, cr15, [r4, #-1008]! @ 0xfffffc10 │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ @ instruction: 0x462e8155 │ │ │ │ ldmdavs r6!, {r1, sp, lr, pc}^ │ │ │ │ rsble r2, r6, r0, lsl #28 │ │ │ │ @ instruction: 0x1e9a6933 │ │ │ │ ldmle r8!, {r0, r9, fp, sp}^ │ │ │ │ - bcs 3898c <__time64@plt+0x276a4> │ │ │ │ - blcs d249c │ │ │ │ + bcs 38984 <__time64@plt+0x2769c> │ │ │ │ + blcs d2494 │ │ │ │ ldmibvs r3!, {r1, r8, ip, lr, pc} │ │ │ │ rscsle r2, r0, r0, lsl #22 │ │ │ │ @ instruction: 0xf7fa6970 │ │ │ │ @ instruction: 0xf8d8fa17 │ │ │ │ strmi r2, [r2], r0 │ │ │ │ - cmppeq r8, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + cmppeq r0, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fc4638 │ │ │ │ ldrtmi pc, [r1], -r3, asr #26 @ │ │ │ │ @ instruction: 0xf7fd4638 │ │ │ │ @ instruction: 0x4638fb1d │ │ │ │ - msreq (UNDEF: 104), sl │ │ │ │ + msreq (UNDEF: 96), sl │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldc2 7, cr15, [r8, #-1008]! @ 0xfffffc10 │ │ │ │ ldrdcs pc, [r0], -r8 │ │ │ │ @ instruction: 0x46384653 │ │ │ │ - cmnpeq r4, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + msreq (UNDEF: 108), sl │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2 7, cr15, [lr, #-1008]! @ 0xfffffc10 │ │ │ │ @ instruction: 0xf64a4638 │ │ │ │ - vaddw.s8 q8, q8, d16 │ │ │ │ + vsra.s64 d16, d8, #64 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ - bvs 1d5d1c0 │ │ │ │ + bvs 1d5d1b8 │ │ │ │ @ instruction: 0xf648b17c │ │ │ │ - vqdmlal.s , d16, d12 │ │ │ │ + vqdmlal.s , d16, d4 │ │ │ │ stmdavs r0!, {r1, r8, fp}^ │ │ │ │ @ instruction: 0xf7f34649 │ │ │ │ - ldmdblt r8, {r1, r3, r4, r6, r8, fp, sp, lr, pc} │ │ │ │ - blcs b7fc8 │ │ │ │ + ldmdblt r8, {r1, r2, r3, r4, r6, r8, fp, sp, lr, pc} │ │ │ │ + blcs b7fc0 │ │ │ │ adchi pc, sl, r0 │ │ │ │ stccs 8, cr6, [r0], {36} @ 0x24 │ │ │ │ @ instruction: 0x4653d1f3 │ │ │ │ ldrdcs pc, [r0], -r8 │ │ │ │ @ instruction: 0xf64a4638 │ │ │ │ - vsra.s64 q8, q10, #64 │ │ │ │ + vmla.f d16, d16, d0[7] │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ ldmdbvs r3!, {r0, r1, r3, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ andle r4, r2, r3, asr r5 │ │ │ │ @ instruction: 0xf7f34650 │ │ │ │ - ldmibvs r3!, {r1, r2, r3, r4, r6, r8, fp, sp, lr, pc} │ │ │ │ + ldmibvs r3!, {r1, r5, r6, r8, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xd1a22b00 │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf64a6972 │ │ │ │ - vorr.i32 d17, #8 @ 0x00000008 │ │ │ │ + vorr.i32 d17, #0 @ 0x00000000 │ │ │ │ ldmdavs r8, {r1, r8} │ │ │ │ - b 55bd50 │ │ │ │ + b 65bd48 │ │ │ │ @ instruction: 0x4638e795 │ │ │ │ - cmppne r8, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + cmppne r0, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrbcc pc, [r0, r0, asr #4]! @ │ │ │ │ streq pc, [r5, -r0, asr #5] │ │ │ │ stc2l 7, cr15, [sl], #1008 @ 0x3f0 │ │ │ │ - blcc ff65a6a0 │ │ │ │ - bleq 19a8a4 │ │ │ │ - bne 85b6c8 │ │ │ │ - beq da8ac │ │ │ │ - bicne pc, r0, #77594624 @ 0x4a00000 │ │ │ │ + blcc ff65a698 │ │ │ │ + bleq 19a89c │ │ │ │ + bne 65b6c0 │ │ │ │ + beq da8a4 │ │ │ │ + @ instruction: 0x13b8f64a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ and r9, r4, r4, lsl #6 │ │ │ │ - blcs 380a8 <__time64@plt+0x26dc0> │ │ │ │ + blcs 380a0 <__time64@plt+0x26db8> │ │ │ │ stmdavs sp!, {r0, r2, r3, r5, r8, ip, lr, pc}^ │ │ │ │ stmdbvs fp!, {r0, r2, r3, r5, r8, r9, ip, sp, pc} │ │ │ │ - bcs 65830 │ │ │ │ - blcs d41a4 │ │ │ │ + bcs 65828 │ │ │ │ + blcs d419c │ │ │ │ stmibvs fp!, {r1, r8, ip, lr, pc} │ │ │ │ rscsle r2, r4, r0, lsl #22 │ │ │ │ cmnlt r4, ip, ror #20 │ │ │ │ - stmibvc ip, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmibvc r4, {r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdbeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ strbmi r6, [r9], -r0, ror #16 │ │ │ │ - stmdb r0, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r4, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ rscle r2, r8, r0, lsl #16 │ │ │ │ stccs 8, cr6, [r0], {36} @ 0x24 │ │ │ │ stmdavs fp!, {r1, r2, r4, r5, r6, r7, r8, ip, lr, pc} │ │ │ │ rsbsle r2, r9, r9, lsl #22 │ │ │ │ @ instruction: 0x360168bb │ │ │ │ strtmi fp, [r9], -r3, lsl #23 │ │ │ │ strbmi r4, [r2], -r8, lsr #12 │ │ │ │ - blx ffc5be06 │ │ │ │ + blx ffc5bdfe │ │ │ │ stccs 8, cr6, [r0, #-436] @ 0xfffffe4c │ │ │ │ ldcvs 1, cr13, [fp], #868 @ 0x364 │ │ │ │ @ instruction: 0xdc142b01 │ │ │ │ pop {r0, r3, ip, sp, pc} │ │ │ │ usub8mi r8, r0, r0 │ │ │ │ ldrdmi pc, [r0], -fp │ │ │ │ @ instruction: 0xff56f7f9 │ │ │ │ movwls r6, #10539 @ 0x292b │ │ │ │ strtmi r4, [r0], -r2, lsl #12 │ │ │ │ stmdbvs ip!, {r2, r8, fp, ip, pc}^ │ │ │ │ @ instruction: 0x63baf640 │ │ │ │ strpl lr, [r0], #-2509 @ 0xfffff633 │ │ │ │ - ldmib r8!, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib ip!, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ vaba.s8 d30, d16, d31 │ │ │ │ vmla.f d23, d0, d0[3] │ │ │ │ @ instruction: 0xf8d80105 │ │ │ │ @ instruction: 0x46323014 │ │ │ │ - rscne pc, r8, sl, asr #12 │ │ │ │ + rscne pc, r0, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ andlt r6, r9, r9, lsl #16 │ │ │ │ svcmi 0x00f0e8bd │ │ │ │ - ldmlt r0, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmlt r4, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f9681c │ │ │ │ stmdbvs fp!, {r0, r2, r3, r5, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ stmib sp, {r1, r9, sl, lr}^ │ │ │ │ strtmi r5, [r0], -r1, lsl #6 │ │ │ │ @ instruction: 0xf64a9600 │ │ │ │ - vsra.s64 d17, d4, #64 │ │ │ │ + vaddw.s8 , q8, d12 │ │ │ │ @ instruction: 0xf6400102 │ │ │ │ @ instruction: 0xf7f363b2 │ │ │ │ - ldr lr, [r4, lr, lsl #19]! │ │ │ │ + @ instruction: 0xe7b4e992 │ │ │ │ ldrdls pc, [ip], -r4 │ │ │ │ ldrdcc pc, [r0], -r9 │ │ │ │ - bcs 65b08 │ │ │ │ - blcs 2942cc │ │ │ │ + bcs 65b00 │ │ │ │ + blcs 2942c4 │ │ │ │ @ instruction: 0xf106d008 │ │ │ │ @ instruction: 0xf64a0018 │ │ │ │ - vsra.s64 q8, q0, #64 │ │ │ │ + vmla.f d16, d16, d0[2] │ │ │ │ @ instruction: 0xf7fa0102 │ │ │ │ usat pc, #28, fp, lsl #29 @ │ │ │ │ @ instruction: 0x0014f8d9 │ │ │ │ @ instruction: 0xf922f7fa │ │ │ │ strmi r9, [r4], -r1 │ │ │ │ - asrseq pc, sl, #12 @ │ │ │ │ + @ instruction: 0x01a8f64a │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdcs pc, [r0], -r8 │ │ │ │ ldrtmi r9, [r8], -r0, lsl #4 │ │ │ │ @ instruction: 0xf7fc6973 │ │ │ │ @ instruction: 0xf8d9fc4b │ │ │ │ adcmi r3, r3, #20 │ │ │ │ mcrge 4, 7, pc, cr7, cr15, {1} @ │ │ │ │ @ instruction: 0xf7f34620 │ │ │ │ - usat lr, #2, ip, lsl #17 │ │ │ │ + strbt lr, [r2], r0, lsr #17 │ │ │ │ @ instruction: 0x2c006aec │ │ │ │ svcge 0x0065f43f │ │ │ │ cdpcc 2, 13, cr15, cr8, cr0, {2} │ │ │ │ cdpeq 2, 0, cr15, cr5, cr0, {6} │ │ │ │ - msrne (UNDEF: 96), sl │ │ │ │ + cmppne r8, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - stcne 6, cr15, [r0], #-288 @ 0xfffffee0 │ │ │ │ + ldcne 6, cr15, [r8], {72} @ 0x48 │ │ │ │ stceq 2, cr15, [r2], {192} @ 0xc0 │ │ │ │ andsge pc, ip, sp, asr #17 │ │ │ │ stmib sp, {r1, r4, r5, r6, r7, r9, sl, lr}^ │ │ │ │ strmi ip, [fp], r5, lsl #22 │ │ │ │ strtmi lr, [r1], -r6 │ │ │ │ strtmi r4, [r8], -r2, asr #12 │ │ │ │ - blx 18dbf22 │ │ │ │ + blx 18dbf1a │ │ │ │ @ instruction: 0xb1a46864 │ │ │ │ @ instruction: 0x360168bb │ │ │ │ rscsle r2, r4, r0, lsl #22 │ │ │ │ ldrdls pc, [r0], -sl │ │ │ │ @ instruction: 0xf7f99805 │ │ │ │ stmdbvs r3!, {r0, r1, r3, r6, r7, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ stmib sp, {r1, r9, sl, lr}^ │ │ │ │ strbmi r4, [r8], -r1, lsl #6 │ │ │ │ @ instruction: 0x96004659 │ │ │ │ @ instruction: 0x63aaf640 │ │ │ │ - stmdb lr!, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmdb r2!, {r0, r1, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldmib sp, {r0, r1, r5, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ ldr fp, [r2, -r6, lsl #20]! │ │ │ │ @ instruction: 0xf64a4638 │ │ │ │ - vmla.f d17, d0, d0[2] │ │ │ │ + vmla.f d17, d0, d0[0] │ │ │ │ vrhadd.s8 d16, d0, d2 │ │ │ │ vqshl.s64 , q8, #0 │ │ │ │ strtmi r0, [lr], -r5, lsl #14 │ │ │ │ stc2 7, cr15, [r0], {252} @ 0xfc │ │ │ │ svclt 0x0000e74d │ │ │ │ @ instruction: 0x460db570 │ │ │ │ addslt r2, r6, ip, asr #4 │ │ │ │ strmi r2, [r4], -r0, lsl #2 │ │ │ │ @ instruction: 0xf7f3a802 │ │ │ │ - stmdavs fp!, {r2, r3, r5, r8, fp, sp, lr, pc} │ │ │ │ - blcc 265bf4 │ │ │ │ + stmdavs fp!, {r4, r5, r8, fp, sp, lr, pc} │ │ │ │ + blcc 265bec │ │ │ │ svclt 0x00882b01 │ │ │ │ vpmax.s8 d2, d0, d1 │ │ │ │ stmibvs r8!, {r0, r1, r2, r3, r6, r7, pc} │ │ │ │ @ instruction: 0xf7fe2601 │ │ │ │ @ instruction: 0xf64affa3 │ │ │ │ - vrsra.s64 , , #64 │ │ │ │ + vqdmlal.s , d16, d1[2] │ │ │ │ movwls r0, #8961 @ 0x2301 │ │ │ │ @ instruction: 0xf6496a6b │ │ │ │ - vsra.s64 q11, q0, #64 │ │ │ │ + vmla.f d22, d16, d0[2] │ │ │ │ movwls r0, #20738 @ 0x5102 │ │ │ │ tstpeq r8, #1073741825 @ p-variant is OBSOLETE @ 0x40000001 │ │ │ │ - bvs feb02bf0 │ │ │ │ + bvs feb02be8 │ │ │ │ movwls r9, #57348 @ 0xe004 │ │ │ │ - movwvs pc, #33354 @ 0x824a @ │ │ │ │ + movwvs pc, #586 @ 0x24a @ │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ subvs pc, r8, sp, lsl #17 │ │ │ │ movwls r9, #29449 @ 0x7309 │ │ │ │ - movwvs pc, #49738 @ 0xc24a @ │ │ │ │ + movwvs pc, #16970 @ 0x424a @ │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ vcgt.s8 d25, d14, d8 │ │ │ │ - vbic.i32 q9, #1024 @ 0x00000400 │ │ │ │ + vqdmlal.s q9, d0, d0[7] │ │ │ │ movwls r0, #41730 @ 0xa302 │ │ │ │ - bicseq pc, ip, #-1610612732 @ 0xa0000004 │ │ │ │ + bicseq pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0xf7fc9306 │ │ │ │ stmdals r4, {r0, r1, r2, r3, r4, r5, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ - msrvs R8_usr, sl │ │ │ │ + tstpvs r8, sl, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx fee5bff2 │ │ │ │ + blx fee5bfea │ │ │ │ vadd.i8 d25, d11, d4 │ │ │ │ - vorr.i32 d19, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 , q0, d12 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdals r4, {r0, r4, r5, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fd4621 │ │ │ │ stmdals r4, {r0, r1, r3, r7, r8, fp, ip, sp, lr, pc} │ │ │ │ - tstpcs r8, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpcs r0, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx fe9dc016 │ │ │ │ + blx fe9dc00e │ │ │ │ vadd.i8 d25, d11, d4 │ │ │ │ - vorr.i32 d21, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 , q0, d12 │ │ │ │ @ instruction: 0xf7fc0102 │ │ │ │ stmdavs fp!, {r0, r1, r2, r3, r4, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf64a9804 │ │ │ │ - vaddw.s8 q9, q8, d4 │ │ │ │ - blcs 15e448 │ │ │ │ + vbic.i32 q9, #12 @ 0x0000000c │ │ │ │ + blcs 15e440 │ │ │ │ svclt 0x0015696b │ │ │ │ - sbcscc pc, r0, #76, 12 @ 0x4c00000 │ │ │ │ - sbcpl pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ + sbccc pc, r8, #76, 12 @ 0x4c00000 │ │ │ │ + sbcpl pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ andls r9, r0, #67108864 @ 0x4000000 │ │ │ │ - blx fe2dc04e │ │ │ │ + blx fe2dc046 │ │ │ │ andcs r6, r2, #2818048 @ 0x2b0000 │ │ │ │ subsvs pc, r1, sp, lsl #17 │ │ │ │ andls r2, fp, #10240 @ 0x2800 │ │ │ │ stmdbge r2, {r1, r5, ip, lr, pc} │ │ │ │ @ instruction: 0xf7fd4628 │ │ │ │ stmdals r4, {r0, r1, r2, r3, r4, r6, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ mvnvc pc, sl, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx 1e5c072 │ │ │ │ - blcs 2b8110 │ │ │ │ - bvs 1b5214c │ │ │ │ + blx 1e5c06a │ │ │ │ + blcs 2b8108 │ │ │ │ + bvs 1b52144 │ │ │ │ @ instruction: 0xf649b184 │ │ │ │ - vmov.i32 d19, #0 @ 0x00000000 │ │ │ │ + vsubhn.i16 d19, q0, q4 │ │ │ │ and r0, r1, r2, lsl #12 │ │ │ │ cmplt ip, r4, lsr #16 │ │ │ │ ldrtmi r6, [r1], -r0, ror #16 │ │ │ │ - svc 0x00a4f7f2 │ │ │ │ + svc 0x00a8f7f2 │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ strtmi sl, [r8], -r2, lsl #18 │ │ │ │ ldc2 7, cr15, [sl], #1016 @ 0x3f8 │ │ │ │ ldcllt 0, cr11, [r0, #-88]! @ 0xffffffa8 │ │ │ │ andcs r9, r2, #10240 @ 0x2800 │ │ │ │ vadd.i8 d25, d9, d4 │ │ │ │ - vmla.f d23, d0, d0[7] │ │ │ │ + vmla.f d23, d0, d0[5] │ │ │ │ movwls r0, #258 @ 0x102 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ - blx 14dc0be │ │ │ │ + blx 14dc0b6 │ │ │ │ andls r9, r0, #24576 @ 0x6000 │ │ │ │ - bicmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0x43bcf24a │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ stmdals r4, {r0, r1, r3, r9, fp, ip, pc} │ │ │ │ - bicsvc pc, r4, r9, asr #4 │ │ │ │ + bicvc pc, ip, r9, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx 115c0da │ │ │ │ + blx 115c0d2 │ │ │ │ stmdavs fp!, {r0, r1, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ tstle r5, sl, lsl #22 │ │ │ │ @ instruction: 0x2c006a2c │ │ │ │ stmiavs r0!, {r0, r1, r2, r6, r7, ip, lr, pc} │ │ │ │ svcne 0x001a6803 │ │ │ │ - blcs 6cd24 │ │ │ │ - bcs 8df24 │ │ │ │ + blcs 6cd1c │ │ │ │ + bcs 8df1c │ │ │ │ stmdbge r2, {r1, r2, fp, ip, lr, pc} │ │ │ │ stc2 7, cr15, [sl], {254} @ 0xfe │ │ │ │ stccs 8, cr6, [r0], {36} @ 0x24 │ │ │ │ @ instruction: 0xe7b8d1f1 │ │ │ │ stccs 8, cr6, [r0], {36} @ 0x24 │ │ │ │ ldr sp, [r4, sp, ror #3]! │ │ │ │ - adcscs pc, r4, #77594624 @ 0x4a00000 │ │ │ │ + adccs pc, ip, #77594624 @ 0x4a00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ msrvc R11_usr, r0 │ │ │ │ - @ instruction: 0xf9caf7f3 │ │ │ │ - adcpl pc, r8, #-1610612732 @ 0xa0000004 │ │ │ │ + @ instruction: 0xf9cef7f3 │ │ │ │ + adcpl pc, r0, #-1610612732 @ 0xa0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ bicsmi pc, pc, r0, asr #12 │ │ │ │ - @ instruction: 0xf9bef7f3 │ │ │ │ + @ instruction: 0xf9c2f7f3 │ │ │ │ @ instruction: 0xf7feb508 │ │ │ │ smlabtlt r0, r9, lr, pc @ │ │ │ │ stclt 8, cr6, [r8, #-256] @ 0xffffff00 │ │ │ │ @ instruction: 0x460db538 │ │ │ │ ldmdblt r0, {r2, r9, sl, lr} │ │ │ │ stmdavs r4!, {r2, r3, sp, lr, pc} │ │ │ │ stmiavs r3!, {r2, r4, r6, r8, ip, sp, pc} │ │ │ │ mvnsle r2, r1, lsl #22 │ │ │ │ strtmi r6, [r9], -r0, ror #16 │ │ │ │ - svc 0x003af7f2 │ │ │ │ + svc 0x003ef7f2 │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ ldclt 8, cr6, [r8, #-896]! @ 0xfffffc80 │ │ │ │ ldclt 6, cr4, [r8, #-128]! @ 0xffffff80 │ │ │ │ @ instruction: 0x4604b538 │ │ │ │ @ instruction: 0x460db158 │ │ │ │ stmdavs r4!, {r0, sp, lr, pc}^ │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r8, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f24629 │ │ │ │ - stmdacs r0, {r1, r3, r5, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r3, r5, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ strdcs sp, [r1], -r7 │ │ │ │ @ instruction: 0x4620bd38 │ │ │ │ svclt 0x0000bd38 │ │ │ │ @ instruction: 0x4604b538 │ │ │ │ andcs r4, r1, sp, lsl #12 │ │ │ │ @ instruction: 0xf7f92108 │ │ │ │ stmdavs r3!, {r0, r3, r4, r5, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ movwpl lr, #2496 @ 0x9c0 │ │ │ │ ldclt 0, cr6, [r8, #-128]! @ 0xffffff80 │ │ │ │ @ instruction: 0x4605b538 │ │ │ │ @ instruction: 0xf7f2b328 │ │ │ │ - @ instruction: 0xf100efe6 │ │ │ │ + @ instruction: 0xf100efea │ │ │ │ andcs r0, r1, lr, lsl #2 │ │ │ │ stc2 7, cr15, [sl, #996]! @ 0x3e4 │ │ │ │ movwcs r4, #1540 @ 0x604 │ │ │ │ andcc r4, r9, r9, lsr #12 │ │ │ │ movwcc lr, #2500 @ 0x9c4 │ │ │ │ @ instruction: 0xf7f27223 │ │ │ │ - vrecps.f32 q15, q0, q14 │ │ │ │ + vmax.f32 d30, d16, d0 │ │ │ │ vrsra.s64 , q8, #64 │ │ │ │ andcs r0, r1, #335544320 @ 0x14000000 │ │ │ │ ldclvs 6, cr4, [r8], {33} @ 0x21 │ │ │ │ - blx fe05c1da │ │ │ │ + blx fe05c1d2 │ │ │ │ cmnlt r8, r5, lsl #12 │ │ │ │ ldmdblt r3, {r0, r1, fp, sp, lr} │ │ │ │ strtmi r6, [r0], -r4 │ │ │ │ @ instruction: 0x4620bd38 │ │ │ │ - svc 0x000cf7f2 │ │ │ │ + svc 0x0010f7f2 │ │ │ │ strtmi r6, [r0], -ip, lsr #16 │ │ │ │ @ instruction: 0x4604bd38 │ │ │ │ ldclt 6, cr4, [r8, #-128]! @ 0xffffff80 │ │ │ │ - sbcscs pc, r8, #77594624 @ 0x4a00000 │ │ │ │ + sbcscs pc, r0, #77594624 @ 0x4a00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - eorne pc, r0, r8, asr #12 │ │ │ │ + andsne pc, r8, r8, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ msrmi R8_fiq, r1 │ │ │ │ - @ instruction: 0xf94ef7f3 │ │ │ │ + @ instruction: 0xf952f7f3 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ ldrbvs pc, [ip], r0, asr #4 @ │ │ │ │ streq pc, [r5], -r0, asr #5 │ │ │ │ ldmib r6, {r0, r1, r7, ip, sp, pc}^ │ │ │ │ ldmdavs r0!, {r0, r9, ip, sp} │ │ │ │ @ instruction: 0xf85368f5 │ │ │ │ ldmibvs fp, {r1, r5, ip, sp}^ │ │ │ │ ldmdbvs r3!, {r3, r4, sl, lr} │ │ │ │ addsmi r9, sp, #0, 6 │ │ │ │ vhsub.s8 , , q6 │ │ │ │ - vrsra.s64 q9, q12, #64 │ │ │ │ + vrsra.s64 q9, q8, #64 │ │ │ │ vcgt.s8 d16, d15, d3 │ │ │ │ - vmull.s8 q8, d0, d12 │ │ │ │ + vmull.s8 q8, d0, d4 │ │ │ │ @ instruction: 0xf64f0c02 │ │ │ │ - vaddhn.i16 d23, q8, q2 │ │ │ │ + vmvn.i32 , #786432 @ 0x000c0000 │ │ │ │ strcs r0, [r0, -r2, lsl #8] │ │ │ │ ldrmi r4, [fp], r1, lsl #12 │ │ │ │ strtmi r9, [sl], r1, lsl #12 │ │ │ │ - blcc 9c2cc │ │ │ │ + blcc 9c2c4 │ │ │ │ ldrmi r2, [r6], -r1, lsl #4 │ │ │ │ @ instruction: 0xf81cb113 │ │ │ │ ldrtmi r6, [r2], -r3 │ │ │ │ strmi r0, [r8], -fp, asr #32 │ │ │ │ vmlaeq.f64 d14, d3, d12 │ │ │ │ ldrbne pc, [ip, #-2494]! @ 0xfffff642 @ │ │ │ │ @ instruction: 0xe100f9be │ │ │ │ @ instruction: 0xf1be4411 │ │ │ │ svclt 0x001c0f00 │ │ │ │ pkhtbmi r4, r1, r0, asr #13 │ │ │ │ ands pc, r1, r4, lsr r9 @ │ │ │ │ smladcs r1, r8, pc, fp @ │ │ │ │ andsle r4, r4, r6, lsl #11 │ │ │ │ strbtmi r4, [r2], #-1123 @ 0xfffffb9d │ │ │ │ - beq 165c980 │ │ │ │ + beq 165c978 │ │ │ │ svcvc 0x000ff5b0 │ │ │ │ movteq lr, #2639 @ 0xa4f │ │ │ │ - bl 355724 │ │ │ │ + bl 35571c │ │ │ │ @ instruction: 0xf8920103 │ │ │ │ sasxmi r2, r6, r4 │ │ │ │ ldrbne pc, [ip, #-2481]! @ 0xfffff64f @ │ │ │ │ @ instruction: 0xf9344411 │ │ │ │ strmi lr, [r6, #17] │ │ │ │ @ instruction: 0xf93bd1ea │ │ │ │ @ instruction: 0x46193011 │ │ │ │ adcmi r9, fp, #0, 22 │ │ │ │ cdpls 1, 0, cr13, cr1, cr7, {6} │ │ │ │ tstlt pc, r8, lsl #12 │ │ │ │ stmdals r5, {r1, r2, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ - bl 3422b4 │ │ │ │ + bl 3422ac │ │ │ │ ldrtmi r0, [r2], -r3, lsl #2 │ │ │ │ ldrbne pc, [ip, #-2481]! @ 0xfffff64f @ │ │ │ │ @ instruction: 0xf9344431 │ │ │ │ strmi lr, [r6, #17] │ │ │ │ @ instruction: 0xf93bd1d2 │ │ │ │ @ instruction: 0x46193011 │ │ │ │ adcmi r9, fp, #0, 22 │ │ │ │ strb sp, [r6, pc, lsr #3]! │ │ │ │ vrshl.s8 d27, d8, d0 │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ strmi r0, [r2], -r5, lsl #6 │ │ │ │ - @ instruction: 0x41b4f648 │ │ │ │ + @ instruction: 0x41acf648 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7f26818 │ │ │ │ - andcs lr, r2, r0, asr #30 │ │ │ │ - svc 0x0022f7f2 │ │ │ │ + andcs lr, r2, r4, asr #30 │ │ │ │ + svc 0x0026f7f2 │ │ │ │ vqrshl.s8 , q8, q0 │ │ │ │ @ instruction: 0xf2c064dc │ │ │ │ stmdavs r6!, {r0, r2, sl}^ │ │ │ │ stmibvs r5!, {r1, r2, r5, r7, r8, ip, sp, pc}^ │ │ │ │ cdpne 8, 6, cr6, cr9, cr2, {5} │ │ │ │ stmdble r0, {r0, r4, r7, r9, lr} │ │ │ │ strcc fp, [r8, #-3440] @ 0xfffff290 │ │ │ │ adceq r4, r9, r0, lsr r6 │ │ │ │ stc2 7, cr15, [sl, #-996] @ 0xfffffc1c │ │ │ │ rsbvs r6, r0, r3, ror #19 │ │ │ │ tstcs r0, r0, lsr #4 │ │ │ │ addeq lr, r3, r0, lsl #22 │ │ │ │ - svc 0x003af7f2 │ │ │ │ + svc 0x003ef7f2 │ │ │ │ ldcllt 1, cr6, [r0, #-916]! @ 0xfffffc6c │ │ │ │ @ instruction: 0xf7f92004 │ │ │ │ strdvs pc, [r6], -r1 │ │ │ │ rsbvs r2, r0, r1, lsl #6 │ │ │ │ adcvs r6, r6, r3, ror #3 │ │ │ │ svclt 0x0000bd70 │ │ │ │ @ instruction: 0x4604b538 │ │ │ │ @ instruction: 0xffd6f7ff │ │ │ │ bicsvs pc, ip, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ mvnlt r6, sl, asr r8 │ │ │ │ @ instruction: 0xf8526899 │ │ │ │ - bl 9e420 │ │ │ │ + bl 9e418 │ │ │ │ adcmi r0, r0, #33024 @ 0x8100 │ │ │ │ bicslt sp, r0, r5, lsl r0 │ │ │ │ @ instruction: 0xf893691d │ │ │ │ eorvc r0, r8, r0, lsr #32 │ │ │ │ eoreq pc, r1, r2, asr r8 @ │ │ │ │ - bvs 17765c8 │ │ │ │ + bvs 17765c0 │ │ │ │ stmdavs r0!, {r0, r2, r8, sp, lr} │ │ │ │ eormi pc, r1, r2, asr #16 │ │ │ │ addsvs r6, r8, #10616832 @ 0xa20000 │ │ │ │ stmdbvs r1!, {r1, r3, r4, r6, r7, sp, lr} │ │ │ │ tstvs sl, r9, asr r2 │ │ │ │ @ instruction: 0xf8837812 │ │ │ │ ldclt 0, cr2, [r8, #-128]! @ 0xffffff80 │ │ │ │ rscsle r2, ip, r0, lsl #24 │ │ │ │ - b 13f8640 │ │ │ │ + b 13f8638 │ │ │ │ stmdavs r1!, {r1, r7, sl, fp} │ │ │ │ @ instruction: 0xf8cc68a2 │ │ │ │ sbcsvs r4, sl, r0 │ │ │ │ @ instruction: 0xe7ec6299 │ │ │ │ vcgt.s8 d27, d0, d8 │ │ │ │ vrsra.s64 q11, q6, #64 │ │ │ │ ldrlt r0, [r0, #-773] @ 0xfffffcfb │ │ │ │ ldmdavs sl, {r2, r9, sl, lr}^ │ │ │ │ ldmvs fp, {r1, r5, r8, ip, sp, pc} │ │ │ │ eorne pc, r3, r2, asr r8 @ │ │ │ │ andle r4, r6, r8, lsl #5 │ │ │ │ ldmdblt r3, {r0, r1, r5, r6, r8, fp, sp, lr}^ │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7f24010 │ │ │ │ - stmdbvs r1, {r0, r2, r9, sl, fp, ip, sp, pc}^ │ │ │ │ + stmdbvs r1, {r0, r3, r9, sl, fp, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf8422000 │ │ │ │ stmdbcs r0, {r0, r1, r5} │ │ │ │ stmdavs r0!, {r2, r4, r5, r6, r7, ip, lr, pc}^ │ │ │ │ - ldcl 7, cr15, [lr, #968]! @ 0x3c8 │ │ │ │ + mcr 7, 0, pc, cr2, cr2, {7} @ │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7f24010 │ │ │ │ - @ instruction: 0x4770bdf7 │ │ │ │ + @ instruction: 0x4770bdfb │ │ │ │ ldrlt fp, [r0], #-792 @ 0xfffffce8 │ │ │ │ stmdavs r4, {r9, sp}^ │ │ │ │ vrhadd.s8 d22, d0, d2 │ │ │ │ vrsra.s64 q11, q6, #64 │ │ │ │ tstcs r1, r5, lsl #6 │ │ │ │ stmdavs r4, {r1, r5, ip, sp, lr}^ │ │ │ │ bicvs r7, r1, r2, rrx │ │ │ │ sbcvs r6, r2, #5832704 @ 0x590000 │ │ │ │ addvs r6, r2, r2, asr #16 │ │ │ │ ldmvs ip, {r0, r5, r8, ip, sp, pc} │ │ │ │ eorne pc, r4, r1, asr r8 @ │ │ │ │ andle r4, r2, r8, lsl #5 │ │ │ │ - blmi 15c5d8 │ │ │ │ + blmi 15c5d0 │ │ │ │ stmdavs r1, {r4, r5, r6, r8, r9, sl, lr} │ │ │ │ smullsvs r6, sl, r9, r2 │ │ │ │ tstvs sl, r1, lsl #18 │ │ │ │ subsvs r7, r9, #1179648 @ 0x120000 │ │ │ │ eorcs pc, r0, r3, lsl #17 │ │ │ │ @ instruction: 0x4770e7f2 │ │ │ │ @ instruction: 0x4604b5f8 │ │ │ │ @ instruction: 0xf7f2460e │ │ │ │ - strmi lr, [r5], -r0, lsr #29 │ │ │ │ + strmi lr, [r5], -r4, lsr #29 │ │ │ │ stmdavs pc!, {r5, r9, sl, lr} @ │ │ │ │ @ instruction: 0xffd0f7ff │ │ │ │ bicsvs pc, ip, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ eorvs r2, r6, r1, lsl #2 │ │ │ │ ldmdavs sl, {r0, r5, r7, r9, sp, lr}^ │ │ │ │ ldmvs fp, {r1, r3, r4, r6, r8, ip, sp, pc} │ │ │ │ @@ -13466,15 +13464,15 @@ │ │ │ │ rscsvs r0, r3, r2 │ │ │ │ stc2 7, cr15, [r0], {249} @ 0xf9 │ │ │ │ rsbsvs r2, r0, r1, lsl #6 │ │ │ │ ldrtmi r4, [r0], -r9, asr #12 │ │ │ │ @ instruction: 0xf7ff6173 │ │ │ │ @ instruction: 0xf847ff8d │ │ │ │ ldmib r4, {r3, r5, sp, lr}^ │ │ │ │ - bl 1f170 <__time64@plt+0xde88> │ │ │ │ + bl 1f168 <__time64@plt+0xde80> │ │ │ │ stmdacs r0, {r0, r1, r7, r9, sl} │ │ │ │ @ instruction: 0xf850d0cf │ │ │ │ strb r0, [ip, r3, lsr #32] │ │ │ │ svcmi 0x00f0e92d │ │ │ │ ldmvs ip, {r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdaeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ strmi fp, [r7], -fp, lsl #1 │ │ │ │ @@ -13485,64 +13483,64 @@ │ │ │ │ @ instruction: 0xf8985010 │ │ │ │ @ instruction: 0xf8d80020 │ │ │ │ @ instruction: 0xf8d81008 │ │ │ │ movwcs r4, #52 @ 0x34 │ │ │ │ stccs 0, cr6, [r0], {59} @ 0x3b │ │ │ │ adcshi pc, r8, r0, asr #32 │ │ │ │ ldrd pc, [r0], -r8 │ │ │ │ - streq pc, [ip], -pc, asr #4 │ │ │ │ + streq pc, [r4], -pc, asr #4 │ │ │ │ streq pc, [r2], -r0, asr #5 │ │ │ │ - ldmibcs r8!, {r0, r6, r9, ip, sp, lr, pc}^ │ │ │ │ + ldmibcs r0!, {r0, r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbeq r3, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ ldrbmi r9, [pc], -r3, lsl #14 │ │ │ │ @ instruction: 0xf64f46c3 │ │ │ │ - vaddhn.i16 d23, q8, q2 │ │ │ │ + vmvn.i32 , #786432 @ 0x000c0000 │ │ │ │ strls r0, [r2], #-1026 @ 0xfffffbfe │ │ │ │ ldrbmi r7, [ip], -r8, lsr #32 │ │ │ │ ldrdhi pc, [r8], -sp │ │ │ │ @ instruction: 0xf85246d3 │ │ │ │ strls r3, [r1, #-33] @ 0xffffffdf │ │ │ │ @ instruction: 0x464b69d8 │ │ │ │ ldrmi r4, [sp], -r9, lsr #13 │ │ │ │ uxtab16mi r4, ip, r0, ror #8 │ │ │ │ @ instruction: 0xf04f4603 │ │ │ │ @ instruction: 0xf89c0900 │ │ │ │ ldrmi r2, [r8], -r0 │ │ │ │ @ instruction: 0x4661005b │ │ │ │ - beq 11921c │ │ │ │ + beq 119214 │ │ │ │ stceq 1, cr15, [r1], {12} │ │ │ │ and pc, r2, r6, lsl r8 @ │ │ │ │ ldrbcs pc, [ip, #-2490]! @ 0xfffff646 @ │ │ │ │ @ instruction: 0xa100f9ba │ │ │ │ @ instruction: 0xf1ba4472 │ │ │ │ svclt 0x001c0f00 │ │ │ │ strmi r4, [r7], -fp, lsl #13 │ │ │ │ andsne pc, r2, r8, lsr r9 @ │ │ │ │ @ instruction: 0xf04fbf18 │ │ │ │ addmi r0, r8, #16384 @ 0x4000 │ │ │ │ ldrtmi sp, [r3], #-20 @ 0xffffffec │ │ │ │ - bne 165cd00 │ │ │ │ + bne 165ccf8 │ │ │ │ svcvc 0x000ff5b1 │ │ │ │ movteq lr, #6735 @ 0x1a4f │ │ │ │ ldrtmi fp, [r6], #4040 @ 0xfc8 │ │ │ │ andeq lr, r3, #6144 @ 0x1800 │ │ │ │ @ instruction: 0xf89ebfc8 │ │ │ │ @ instruction: 0xf9b2ef34 │ │ │ │ ldrbtmi r2, [r2], #-1404 @ 0xfffffa84 │ │ │ │ andseq pc, r2, r8, lsr r9 @ │ │ │ │ mvnle r4, r8, lsl #5 │ │ │ │ andscc pc, r2, r5, lsr r9 @ │ │ │ │ svcvc 0x000ff5b3 │ │ │ │ @ instruction: 0xf1b9d1c9 │ │ │ │ subsle r0, r6, r0, lsl #30 │ │ │ │ @ instruction: 0x46a946ba │ │ │ │ - blvc 198d80 │ │ │ │ - bl 1c4e78 │ │ │ │ + blvc 198d78 │ │ │ │ + bl 1c4e70 │ │ │ │ stmib r4, {r1, r3, r6, r8, r9}^ │ │ │ │ - bl feae9288 │ │ │ │ + bl feae9280 │ │ │ │ @ instruction: 0x63a20202 │ │ │ │ @ instruction: 0x3100f9b3 │ │ │ │ mulcs r0, fp, r8 │ │ │ │ eorcs pc, r0, r4, lsl #17 │ │ │ │ andeq pc, r0, #79 @ 0x4f │ │ │ │ andcs pc, r0, fp, lsl #17 │ │ │ │ vpadd.i8 d2, d1, d27 │ │ │ │ @@ -13584,17 +13582,17 @@ │ │ │ │ ldrmi r2, [lr], r1, lsl #6 │ │ │ │ andcc pc, r0, r8, asr #17 │ │ │ │ @ instruction: 0xf8d8e742 │ │ │ │ movwcs r1, #4096 @ 0x1000 │ │ │ │ eorcc pc, ip, r8, asr #17 │ │ │ │ @ instruction: 0xf8c8b909 │ │ │ │ @ instruction: 0xf8d83000 │ │ │ │ - blcs 2a7e4 <__time64@plt+0x194fc> │ │ │ │ + blcs 2a7dc <__time64@plt+0x194f4> │ │ │ │ @ instruction: 0xf8d8d076 │ │ │ │ - blcs 2a80c <__time64@plt+0x19524> │ │ │ │ + blcs 2a804 <__time64@plt+0x1951c> │ │ │ │ orrslt sp, sl, #125 @ 0x7d │ │ │ │ ldrdne pc, [r8], -r8 │ │ │ │ eoreq pc, r1, r2, asr r8 @ │ │ │ │ stmdavs r3, {r4, r5, r6, r8, r9, ip, sp, pc} │ │ │ │ @ instruction: 0xf8c86885 │ │ │ │ stmib r8, {r3, r5, ip, sp}^ │ │ │ │ stmdbvs r3, {r0, r1, r8, sl, ip, lr} │ │ │ │ @@ -13629,35 +13627,35 @@ │ │ │ │ @ instruction: 0x4649fabd │ │ │ │ rsbvs r2, r0, r1, lsl #6 │ │ │ │ strtmi r6, [r0], -r3, ror #2 │ │ │ │ mcr2 7, 2, pc, cr10, cr15, {7} @ │ │ │ │ eormi pc, r6, r5, asr #16 │ │ │ │ ldrdcs lr, [r1, -r8] │ │ │ │ eoreq pc, r1, r2, asr r8 @ │ │ │ │ - blvs fe9186bc │ │ │ │ + blvs fe9186b4 │ │ │ │ @ instruction: 0xf8944657 │ │ │ │ ldrbmi r0, [sl], r0, lsr #32 │ │ │ │ ldrdcs lr, [r1, -r4] │ │ │ │ stmdbvs r5!, {r0, r1, r5, r7, r9, sl, lr} │ │ │ │ @ instruction: 0xf8d42b00 │ │ │ │ @ instruction: 0xf8cde000 │ │ │ │ @ instruction: 0xf77f8008 │ │ │ │ stmiavs r4!, {r0, r1, r2, r3, r4, r6, r7, r9, sl, fp, sp, pc}^ │ │ │ │ @ instruction: 0xf8134423 │ │ │ │ @ instruction: 0xf852cc01 │ │ │ │ @ instruction: 0xf1ac3021 │ │ │ │ - blx fef21850 │ │ │ │ - b 141da5c │ │ │ │ + blx fef21848 │ │ │ │ + b 141da54 │ │ │ │ @ instruction: 0xf8c31c5c │ │ │ │ @ instruction: 0xe6cfc01c │ │ │ │ mvncc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf8c8681b │ │ │ │ @ instruction: 0xf8d83028 │ │ │ │ - blcs 2a908 <__time64@plt+0x19620> │ │ │ │ + blcs 2a900 <__time64@plt+0x19618> │ │ │ │ vrhadd.s8 d29, d16, d1 │ │ │ │ vqdmlal.s , d16, d0[5] │ │ │ │ ldmdavs fp, {r0, r2, r8, r9} │ │ │ │ eorscc pc, r0, r8, asr #17 │ │ │ │ @ instruction: 0xf47f2a00 │ │ │ │ @ instruction: 0xe7abaf79 │ │ │ │ ldrmi r2, [r8], -r0, lsl #6 │ │ │ │ @@ -13675,21 +13673,21 @@ │ │ │ │ bicsvs r0, r3, fp, asr r9 │ │ │ │ @ instruction: 0xf0081c4a │ │ │ │ vmax.f32 , q8, │ │ │ │ eorsvs r1, r8, r1, lsl r3 │ │ │ │ @ instruction: 0x465be7df │ │ │ │ mlacs r0, r4, r8, pc @ │ │ │ │ @ instruction: 0xf80346a0 │ │ │ │ - bls 68cb4 │ │ │ │ - bne fe6b6c3c │ │ │ │ + bls 68cac │ │ │ │ + bne fe6b6c34 │ │ │ │ @ instruction: 0x612363a2 │ │ │ │ @ instruction: 0xf81b2200 │ │ │ │ @ instruction: 0xf80b3c01 │ │ │ │ @ instruction: 0xf8842c01 │ │ │ │ - blvs fe8aa948 │ │ │ │ + blvs fe8aa940 │ │ │ │ vstrle s4, [sp, #-0] │ │ │ │ movweq lr, #10708 @ 0x29d4 │ │ │ │ ldrmi r6, [r3], #-2145 @ 0xfffff79f │ │ │ │ eorcs pc, r0, r1, asr r8 @ │ │ │ │ stccc 8, cr15, [r1], {19} │ │ │ │ movweq pc, #41379 @ 0xa1a3 @ │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ @@ -13701,67 +13699,67 @@ │ │ │ │ strtmi r9, [r3], r1, lsl #18 │ │ │ │ mlacc r0, r4, r8, pc @ │ │ │ │ andcc pc, r0, sl, lsl #17 │ │ │ │ rscvs r2, r1, r1, lsl #6 │ │ │ │ movwcs r6, #931 @ 0x3a3 │ │ │ │ stmdavc r8, {r1, r5, r6, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf8d4704b │ │ │ │ - blvs fe996918 │ │ │ │ + blvs fe996910 │ │ │ │ addsmi r6, sp, #10551296 @ 0xa10000 │ │ │ │ andhi pc, r8, sp, asr #17 │ │ │ │ stmiavs r3!, {r0, r1, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf813442b │ │ │ │ @ instruction: 0xf8525c01 │ │ │ │ @ instruction: 0xf1a53021 │ │ │ │ - blx fed5fd5c │ │ │ │ + blx fed5fd54 │ │ │ │ stmdbeq sp!, {r0, r2, r7, r8, sl, ip, sp, lr, pc}^ │ │ │ │ stcls 1, cr6, [r1, #-884] @ 0xfffffc8c │ │ │ │ strb r3, [r9], -r1, lsl #10 │ │ │ │ ldrbmi r6, [r7], -r2, lsr #23 │ │ │ │ andhi pc, r8, sp, asr #17 │ │ │ │ - bcs 304b4 <__time64@plt+0x1f1cc> │ │ │ │ + bcs 304ac <__time64@plt+0x1f1c4> │ │ │ │ stcle 6, cr4, [sp, #-652] @ 0xfffffd74 │ │ │ │ ldrmi r6, [r3], #-2275 @ 0xfffff71d │ │ │ │ ldrdcs lr, [r1, -r4] │ │ │ │ stccc 8, cr15, [r1], {19} │ │ │ │ eorcs pc, r1, r2, asr r8 @ │ │ │ │ movweq pc, #41379 @ 0xa1a3 @ │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ bicsvs r0, r3, fp, asr r9 │ │ │ │ - tstpcs r8, ip, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpcs r0, ip, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fa48bb │ │ │ │ @ instruction: 0xf8dbf939 │ │ │ │ @ instruction: 0xf89b5010 │ │ │ │ ldmib fp, {r5}^ │ │ │ │ @ instruction: 0xf8dbe200 │ │ │ │ strt r1, [r3], -r8 │ │ │ │ mlacc r0, r4, r8, pc @ │ │ │ │ andcc pc, r0, fp, lsl #17 │ │ │ │ - blge 1990e8 │ │ │ │ + blge 1990e0 │ │ │ │ ldrbmi lr, [fp], -sl, ror #12 │ │ │ │ mlacs r0, r4, r8, pc @ │ │ │ │ strtmi r9, [r0], r3, lsl #30 │ │ │ │ stmdbcs r1, {r0, r1, fp, ip, sp, lr, pc} │ │ │ │ rscvs r9, r2, r1, lsl #20 │ │ │ │ @ instruction: 0x63a21a9a │ │ │ │ movwcs r6, #291 @ 0x123 │ │ │ │ stccs 8, cr15, [r1], {27} │ │ │ │ eorcs pc, r0, r4, lsl #17 │ │ │ │ stccc 8, cr15, [r1], {11} │ │ │ │ - blvs fe858718 │ │ │ │ + blvs fe858710 │ │ │ │ ldmib r4, {r0, r1, r2, r4, r6, r9, sl, lr}^ │ │ │ │ ldrbmi r2, [sl], r1, lsl #2 │ │ │ │ strtmi r2, [r3], r0, lsl #16 │ │ │ │ andhi pc, r8, sp, asr #17 │ │ │ │ stmiavs r3!, {r0, r1, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf8134403 │ │ │ │ @ instruction: 0xf8520c01 │ │ │ │ @ instruction: 0xf1a03021 │ │ │ │ - blx fec1ea10 │ │ │ │ + blx fec1ea08 │ │ │ │ stmdbeq r0, {r7, ip, sp, lr, pc}^ │ │ │ │ movwcs r6, #4568 @ 0x11d8 │ │ │ │ @ instruction: 0x5010f8db │ │ │ │ mlaeq r0, fp, r8, pc @ │ │ │ │ @ instruction: 0xf8cb469e │ │ │ │ strb r3, [r9, #0]! │ │ │ │ ldrbmi r6, [r7], -r0, lsr #23 │ │ │ │ @@ -13775,39 +13773,39 @@ │ │ │ │ andeq pc, sl, r0, lsr #3 │ │ │ │ @ instruction: 0xf080fab0 │ │ │ │ bicsvs r0, r8, r0, asr #18 │ │ │ │ @ instruction: 0xf8db2307 │ │ │ │ @ instruction: 0xf89b5010 │ │ │ │ ldrmi r0, [lr], r0, lsr #32 │ │ │ │ andcc pc, r0, fp, asr #17 │ │ │ │ - blvs fe918168 │ │ │ │ + blvs fe918160 │ │ │ │ stmiavs r2!, {r0, r1, r2, r4, r6, r9, sl, lr}^ │ │ │ │ - blcs 305b0 <__time64@plt+0x1f2c8> │ │ │ │ + blcs 305a8 <__time64@plt+0x1f2c0> │ │ │ │ @ instruction: 0xf8cd46a3 │ │ │ │ stcle 0, cr8, [ip, #-32] @ 0xffffffe0 │ │ │ │ ldmib r4, {r0, r1, r4, sl, lr}^ │ │ │ │ @ instruction: 0xf8131001 │ │ │ │ @ instruction: 0xf8513c01 │ │ │ │ @ instruction: 0xf1a31020 │ │ │ │ - blx fecdf68c │ │ │ │ + blx fecdf684 │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ ldmdami lr!, {r0, r1, r3, r6, r7, r8, sp, lr}^ │ │ │ │ mvnsne pc, ip, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf8baf7fa │ │ │ │ - blvs fe858878 │ │ │ │ + blvs fe858870 │ │ │ │ ldmib r4, {r0, r1, r2, r4, r6, r9, sl, lr}^ │ │ │ │ ldrbmi r2, [sl], r1, lsl #2 │ │ │ │ strtmi r2, [r3], r0, lsl #16 │ │ │ │ andhi pc, r8, sp, asr #17 │ │ │ │ stmiavs r3!, {r0, r1, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf8134403 │ │ │ │ @ instruction: 0xf8520c01 │ │ │ │ @ instruction: 0xf1a03021 │ │ │ │ - blx fec1eac8 │ │ │ │ + blx fec1eac0 │ │ │ │ stmdbeq r0, {r7, ip, sp, lr, pc}^ │ │ │ │ movwcs r6, #12760 @ 0x31d8 │ │ │ │ @ instruction: 0x5010f8db │ │ │ │ mlaeq r0, fp, r8, pc @ │ │ │ │ @ instruction: 0xf8cb469e │ │ │ │ str r3, [sp] │ │ │ │ andhi pc, r8, sp, asr #17 │ │ │ │ @@ -13819,88 +13817,88 @@ │ │ │ │ vpmax.f32 d16, d0, d0 │ │ │ │ strbtmi r8, [r0], #1556 @ 0x614 │ │ │ │ mlaeq r0, r4, r8, pc @ │ │ │ │ @ instruction: 0xf8d46925 │ │ │ │ @ instruction: 0xf818e000 │ │ │ │ @ instruction: 0xf8523c01 │ │ │ │ @ instruction: 0xf1a34021 │ │ │ │ - blx fecdf718 │ │ │ │ + blx fecdf710 │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ - bl fea37284 │ │ │ │ + bl fea3727c │ │ │ │ @ instruction: 0xf013030c │ │ │ │ suble r0, sp, r7, lsl #6 │ │ │ │ eorsle r2, pc, r1, lsl #22 │ │ │ │ eorsle r2, r4, r2, lsl #22 │ │ │ │ eorle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, lr, r4, lsl #22 │ │ │ │ andsle r2, r3, r5, lsl #22 │ │ │ │ andle r2, r8, r6, lsl #22 │ │ │ │ - blcc 9cb8c │ │ │ │ + blcc 9cb84 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf81c3040 │ │ │ │ - blcs 2ad734 │ │ │ │ + blcs 2ad72c │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcc 9cbb0 │ │ │ │ + blcc 9cba8 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf81c3040 │ │ │ │ - blcs 2ad758 │ │ │ │ + blcs 2ad750 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcc 9cbd4 │ │ │ │ + blcc 9cbcc │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf81c3040 │ │ │ │ - blcs 2ad77c │ │ │ │ + blcs 2ad774 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcc 9cbf8 │ │ │ │ + blcc 9cbf0 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ strbmi r3, [r0, #64]! @ 0x40 │ │ │ │ ldcge 4, cr15, [ip, #-252] @ 0xffffff04 │ │ │ │ stcls 6, cr4, [r2], {99} @ 0x63 │ │ │ │ ldrmi r4, [sp], -ip, lsr #13 │ │ │ │ - blcc 9cbfc │ │ │ │ + blcc 9cbf4 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ stmdavc fp!, {r6, ip, sp} │ │ │ │ tstle r4, sl, lsl #22 │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ stmdavc fp!, {r6, ip, sp}^ │ │ │ │ - blcs 2abfe8 │ │ │ │ + blcs 2abfe0 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ stccc 8, cr15, [r5], {21} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf8153040 │ │ │ │ - blcs 2adc00 │ │ │ │ + blcs 2adbf8 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ stccc 8, cr15, [r3], {21} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf8153040 │ │ │ │ - blcs 2adc1c │ │ │ │ + blcs 2adc14 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ stccc 8, cr15, [r1], {21} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @@ -13909,31 +13907,31 @@ │ │ │ │ strb r9, [fp], #1026 @ 0x402 │ │ │ │ stmiavs r2!, {r0, r1, r5, r7, r8, r9, fp, sp, lr}^ │ │ │ │ vstrle d2, [ip, #-0] │ │ │ │ ldmib r4, {r0, r1, r4, sl, lr}^ │ │ │ │ @ instruction: 0xf8131001 │ │ │ │ @ instruction: 0xf8513c01 │ │ │ │ @ instruction: 0xf1a31020 │ │ │ │ - blx fecdf880 │ │ │ │ + blx fecdf878 │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ ldmdavc r3, {r0, r1, r3, r6, r7, r8, sp, lr} │ │ │ │ svclt 0x0000e5ff │ │ │ │ andeq r0, r5, r8, lsl r7 │ │ │ │ - bcs 39af4 <__time64@plt+0x2880c> │ │ │ │ + bcs 39aec <__time64@plt+0x28804> │ │ │ │ ldmib r4, {r0, r2, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ stmdavs r1!, {r1, r8, r9}^ │ │ │ │ @ instruction: 0xf8514413 │ │ │ │ @ instruction: 0xf8132020 │ │ │ │ @ instruction: 0xf1a33c01 │ │ │ │ - blx fecdf8ac │ │ │ │ + blx fecdf8a4 │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ vand q11, q8, │ │ │ │ strb r1, [r8, #775]! @ 0x307 │ │ │ │ svcls 0x00036ba2 │ │ │ │ - bcs 39018 <__time64@plt+0x27d30> │ │ │ │ + bcs 39010 <__time64@plt+0x27d28> │ │ │ │ ldmib r4, {r2, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf8533101 │ │ │ │ stmne r3, {r0, r5, ip} │ │ │ │ stccc 8, cr15, [r1], {19} │ │ │ │ movweq pc, #41379 @ 0xa1a3 @ │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ bicvs r0, fp, fp, asr r9 │ │ │ │ @@ -13943,21 +13941,21 @@ │ │ │ │ strb r6, [lr, #56] @ 0x38 │ │ │ │ svcls 0x00036ba1 │ │ │ │ cdpne 8, 4, cr6, cr10, cr0, {7} │ │ │ │ @ instruction: 0xdd0a2900 │ │ │ │ strcc lr, [r1], #-2516 @ 0xfffff62c │ │ │ │ eormi pc, r4, r3, asr r8 @ │ │ │ │ @ instruction: 0xf1a35c83 │ │ │ │ - blx fecdf908 │ │ │ │ + blx fecdf900 │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ stmdbcc r2, {r0, r1, r5, r6, r7, r8, sp, lr} │ │ │ │ @ instruction: 0xf0083001 │ │ │ │ @ instruction: 0xf44ffd99 │ │ │ │ eorsvs r7, r8, r8, lsl #7 │ │ │ │ - blvs fe8983cc │ │ │ │ + blvs fe8983c4 │ │ │ │ stmiavs r0!, {r0, r1, r8, r9, sl, fp, ip, pc}^ │ │ │ │ stmdbcs r0, {r1, r3, r6, r9, sl, fp, ip} │ │ │ │ ldmib r4, {r1, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf8533401 │ │ │ │ stcpl 0, cr4, [r3], {36} @ 0x24 │ │ │ │ movweq pc, #41379 @ 0xa1a3 @ │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ @@ -13977,119 +13975,119 @@ │ │ │ │ eorcc pc, r0, r4, lsl #17 │ │ │ │ stmiavs r0!, {r0, r5, r7, r8, r9, fp, sp, lr}^ │ │ │ │ stcle 2, cr4, [ip, #-580] @ 0xfffffdbc │ │ │ │ andcc lr, r1, #212, 18 @ 0x350000 │ │ │ │ eorcs pc, r2, r3, asr r8 @ │ │ │ │ @ instruction: 0xf8131843 │ │ │ │ @ instruction: 0xf1a33c01 │ │ │ │ - blx fecdf990 │ │ │ │ + blx fecdf988 │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ mcrrne 1, 13, r6, sl, cr3 │ │ │ │ ldc2l 0, cr15, [r6, #-32] @ 0xffffffe0 │ │ │ │ movwne pc, #53824 @ 0xd240 @ │ │ │ │ ldrb r6, [r2, #-56]! @ 0xffffffc8 │ │ │ │ @ instruction: 0xf894465b │ │ │ │ svcls 0x00032020 │ │ │ │ @ instruction: 0xf80346a0 │ │ │ │ - bls 69190 │ │ │ │ - bne fe6b7118 │ │ │ │ + bls 69188 │ │ │ │ + bne fe6b7110 │ │ │ │ @ instruction: 0x612363a2 │ │ │ │ @ instruction: 0xf81b2300 │ │ │ │ @ instruction: 0xf8842c01 │ │ │ │ @ instruction: 0xf80b2020 │ │ │ │ @ instruction: 0xf8d83c01 │ │ │ │ @ instruction: 0xf8d83038 │ │ │ │ - blcs 1eddc <__time64@plt+0xdaf4> │ │ │ │ + blcs 1edd4 <__time64@plt+0xdaec> │ │ │ │ ldmib r8, {r2, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf8522101 │ │ │ │ stmiane r2, {r0, r5, ip}^ │ │ │ │ stccs 8, cr15, [r1], {18} │ │ │ │ andeq pc, sl, #-2147483608 @ 0x80000028 │ │ │ │ @ instruction: 0xf282fab2 │ │ │ │ bicvs r0, sl, r2, asr r9 │ │ │ │ @ instruction: 0xf6423b01 │ │ │ │ - vsra.s64 q9, q0, #64 │ │ │ │ + vmla.f d18, d16, d0[2] │ │ │ │ strmi r0, [r3], #-259 @ 0xfffffefd │ │ │ │ @ instruction: 0x461c781a │ │ │ │ @ instruction: 0xf8313b01 │ │ │ │ @ instruction: 0x06562012 │ │ │ │ @ instruction: 0xf1c0d4f8 │ │ │ │ strtmi r0, [r1], #-257 @ 0xfffffeff │ │ │ │ @ instruction: 0xf0081c4a │ │ │ │ @ instruction: 0xf8d8fd19 │ │ │ │ eorsvs r3, r8, r8, lsr r0 │ │ │ │ ldrdcs pc, [ip], -r8 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ ldmne r1, {r2, r3, r4, r5, r6, sl, pc}^ │ │ │ │ movweq pc, #28691 @ 0x7013 @ │ │ │ │ - blcs 92f28 │ │ │ │ - blcs d2f08 │ │ │ │ - blcs 112ee0 │ │ │ │ - blcs 152eb8 │ │ │ │ - blcs 192e90 │ │ │ │ - blcs 1d2e68 │ │ │ │ + blcs 92f20 │ │ │ │ + blcs d2f00 │ │ │ │ + blcs 112ed8 │ │ │ │ + blcs 152eb0 │ │ │ │ + blcs 192e88 │ │ │ │ + blcs 1d2e60 │ │ │ │ @ instruction: 0xf812d008 │ │ │ │ - blcs 2ada28 │ │ │ │ + blcs 2ada20 │ │ │ │ @ instruction: 0xf8d8bf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, r8, asr #17 │ │ │ │ - blcc 9ce7c │ │ │ │ + blcc 9ce74 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-136 @ 0xffffff78 │ │ │ │ @ instruction: 0xf8c83301 │ │ │ │ @ instruction: 0xf8123040 │ │ │ │ - blcs 2ada4c │ │ │ │ + blcs 2ada44 │ │ │ │ @ instruction: 0xf8d8bf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, r8, asr #17 │ │ │ │ - blcc 9cea0 │ │ │ │ + blcc 9ce98 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-136 @ 0xffffff78 │ │ │ │ @ instruction: 0xf8c83301 │ │ │ │ @ instruction: 0xf8123040 │ │ │ │ - blcs 2ada70 │ │ │ │ + blcs 2ada68 │ │ │ │ @ instruction: 0xf8d8bf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, r8, asr #17 │ │ │ │ - blcc 9cec4 │ │ │ │ + blcc 9cebc │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-136 @ 0xffffff78 │ │ │ │ @ instruction: 0xf8c83301 │ │ │ │ @ instruction: 0xf8123040 │ │ │ │ - blcs 2ada94 │ │ │ │ + blcs 2ada8c │ │ │ │ addsmi sp, r1, #68 @ 0x44 │ │ │ │ - strthi pc, [pc], #-0 @ 1ee98 <__time64@plt+0xdbb0> │ │ │ │ - blcc 9cee4 │ │ │ │ + strthi pc, [pc], #-0 @ 1ee90 <__time64@plt+0xdba8> │ │ │ │ + blcc 9cedc │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-136 @ 0xffffff78 │ │ │ │ @ instruction: 0xf8c83301 │ │ │ │ ldmdavc r3, {r6, ip, sp} │ │ │ │ tstle r4, sl, lsl #22 │ │ │ │ ldrdcc pc, [r0], #-136 @ 0xffffff78 │ │ │ │ @ instruction: 0xf8c83301 │ │ │ │ ldmdavc r3, {r6, ip, sp}^ │ │ │ │ - blcs 2ab6dc │ │ │ │ + blcs 2ab6d4 │ │ │ │ @ instruction: 0xf8d8bf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, r8, asr #17 │ │ │ │ stccc 8, cr15, [r5], {18} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-136 @ 0xffffff78 │ │ │ │ @ instruction: 0xf8c83301 │ │ │ │ @ instruction: 0xf8123040 │ │ │ │ - blcs 2adef4 │ │ │ │ + blcs 2adeec │ │ │ │ @ instruction: 0xf8d8bf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, r8, asr #17 │ │ │ │ stccc 8, cr15, [r3], {18} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-136 @ 0xffffff78 │ │ │ │ @ instruction: 0xf8c83301 │ │ │ │ @ instruction: 0xf8123040 │ │ │ │ - blcs 2adf10 │ │ │ │ + blcs 2adf08 │ │ │ │ @ instruction: 0xf8d8bf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, r8, asr #17 │ │ │ │ stccc 8, cr15, [r1], {18} │ │ │ │ @ instruction: 0xd1ba2b0a │ │ │ │ ldrdcc pc, [r0], #-136 @ 0xffffff78 │ │ │ │ @ instruction: 0xf8c83301 │ │ │ │ @@ -14137,139 +14135,139 @@ │ │ │ │ stccc 8, cr15, [r1], {24} │ │ │ │ eormi pc, r1, r2, asr r8 @ │ │ │ │ movweq pc, #41379 @ 0xa1a3 @ │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ mvnvs r0, fp, asr r9 │ │ │ │ movweq lr, #52136 @ 0xcba8 │ │ │ │ movweq pc, #28691 @ 0x7013 @ │ │ │ │ - blcs 9311c │ │ │ │ - blcs d30e8 │ │ │ │ - blcs 1130c0 │ │ │ │ - blcs 153098 │ │ │ │ - blcs 193070 │ │ │ │ - blcs 1d3048 │ │ │ │ + blcs 93114 │ │ │ │ + blcs d30e0 │ │ │ │ + blcs 1130b8 │ │ │ │ + blcs 153090 │ │ │ │ + blcs 193068 │ │ │ │ + blcs 1d3040 │ │ │ │ @ instruction: 0xf81cd008 │ │ │ │ - blcs 2adc08 │ │ │ │ + blcs 2adc00 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcc 9d084 │ │ │ │ + blcc 9d07c │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf81c3040 │ │ │ │ - blcs 2adc2c │ │ │ │ + blcs 2adc24 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcc 9d0a8 │ │ │ │ + blcc 9d0a0 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf81c3040 │ │ │ │ - blcs 2adc50 │ │ │ │ + blcs 2adc48 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcc 9d0cc │ │ │ │ + blcc 9d0c4 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf81c3040 │ │ │ │ - blcs 2adc74 │ │ │ │ + blcs 2adc6c │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ @ instruction: 0xf43f45e0 │ │ │ │ strbtmi sl, [r3], -r9, lsr #21 │ │ │ │ strtmi r9, [ip], r2, lsl #24 │ │ │ │ @ instruction: 0xf815461d │ │ │ │ - blcs 2adc94 │ │ │ │ + blcs 2adc8c │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcs 2bd14c │ │ │ │ + blcs 2bd144 │ │ │ │ @ instruction: 0xf8dbd104 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ strcc r7, [r7, #-2155] @ 0xfffff795 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf8153040 │ │ │ │ - blcs 2ae0d8 │ │ │ │ + blcs 2ae0d0 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ stccc 8, cr15, [r4], {21} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf8153040 │ │ │ │ - blcs 2ae0f4 │ │ │ │ + blcs 2ae0ec │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ stccc 8, cr15, [r2], {21} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf8153040 │ │ │ │ - blcs 2ae110 │ │ │ │ + blcs 2ae108 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ @ instruction: 0xd1b645a8 │ │ │ │ - blvs fe85874c │ │ │ │ + blvs fe858744 │ │ │ │ ldmib r4, {r0, r1, r2, r4, r6, r9, sl, lr}^ │ │ │ │ ldrbmi r2, [sl], r1, lsl #2 │ │ │ │ strtmi r2, [r3], r0, lsl #16 │ │ │ │ andhi pc, r8, sp, asr #17 │ │ │ │ stmiavs r3!, {r0, r1, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf8134403 │ │ │ │ @ instruction: 0xf8520c01 │ │ │ │ @ instruction: 0xf1a03021 │ │ │ │ - blx fec1f16c │ │ │ │ + blx fec1f164 │ │ │ │ stmdbeq r0, {r7, ip, sp, lr, pc}^ │ │ │ │ movwcs r6, #20952 @ 0x51d8 │ │ │ │ @ instruction: 0x5010f8db │ │ │ │ mlaeq r0, fp, r8, pc @ │ │ │ │ @ instruction: 0xf8cb469e │ │ │ │ @ instruction: 0xf7ff3000 │ │ │ │ @ instruction: 0x465bba3b │ │ │ │ mlacs r0, r4, r8, pc @ │ │ │ │ @ instruction: 0xf80346a0 │ │ │ │ - bls 69570 │ │ │ │ - bne fe6b74f8 │ │ │ │ + bls 69568 │ │ │ │ + bne fe6b74f0 │ │ │ │ @ instruction: 0x612363a2 │ │ │ │ @ instruction: 0xf81b2200 │ │ │ │ @ instruction: 0xf80b3c01 │ │ │ │ @ instruction: 0xf8842c01 │ │ │ │ - blvs fe8ab204 │ │ │ │ + blvs fe8ab1fc │ │ │ │ vstrle s4, [sp, #-0] │ │ │ │ movweq lr, #10708 @ 0x29d4 │ │ │ │ ldrmi r6, [r3], #-2145 @ 0xfffff79f │ │ │ │ eorcs pc, r0, r1, asr r8 @ │ │ │ │ stccc 8, cr15, [r1], {19} │ │ │ │ movweq pc, #41379 @ 0xa1a3 @ │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ bicsvs r0, r3, fp, asr r9 │ │ │ │ vhsub.s8 d18, d0, d3 │ │ │ │ @ instruction: 0xf8c81303 │ │ │ │ @ instruction: 0xf7ff2000 │ │ │ │ @ instruction: 0x465bbb58 │ │ │ │ mlacs r0, r4, r8, pc @ │ │ │ │ @ instruction: 0xf80346a0 │ │ │ │ - bls 695c4 │ │ │ │ - bne fe6b754c │ │ │ │ + bls 695bc │ │ │ │ + bne fe6b7544 │ │ │ │ @ instruction: 0x612363a2 │ │ │ │ @ instruction: 0xf81b2200 │ │ │ │ @ instruction: 0xf80b3c01 │ │ │ │ @ instruction: 0xf8842c01 │ │ │ │ - blvs fe8ab258 │ │ │ │ + blvs fe8ab250 │ │ │ │ vstrle s4, [sp, #-0] │ │ │ │ movweq lr, #10708 @ 0x29d4 │ │ │ │ ldrmi r6, [r3], #-2145 @ 0xfffff79f │ │ │ │ eorcs pc, r0, r1, asr r8 @ │ │ │ │ stccc 8, cr15, [r1], {19} │ │ │ │ movweq pc, #41379 @ 0xa1a3 @ │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ @@ -14300,113 +14298,113 @@ │ │ │ │ stmdbcs r1, {r0, r1, fp, ip, sp, lr, pc} │ │ │ │ rscvs r9, r2, r1, lsl #20 │ │ │ │ @ instruction: 0x63a21a9a │ │ │ │ andcs r6, r0, #-1073741816 @ 0xc0000008 │ │ │ │ stccc 8, cr15, [r1], {27} │ │ │ │ stccs 8, cr15, [r1], {11} │ │ │ │ eorcc pc, r0, r4, lsl #17 │ │ │ │ - bcs 3a0fc <__time64@plt+0x28e14> │ │ │ │ + bcs 3a0f4 <__time64@plt+0x28e0c> │ │ │ │ ldmib r4, {r0, r2, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ stmdavs r1!, {r1, r8, r9}^ │ │ │ │ @ instruction: 0xf8514413 │ │ │ │ @ instruction: 0xf8132020 │ │ │ │ @ instruction: 0xf1a33c01 │ │ │ │ - blx fecdfeb4 │ │ │ │ + blx fecdfeac │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ andcs r6, r3, #-1073741772 @ 0xc0000034 │ │ │ │ orrvc pc, r1, #1325400064 @ 0x4f000000 │ │ │ │ andcs pc, r0, r8, asr #17 │ │ │ │ - blt ff89d29c │ │ │ │ + blt ff89d294 │ │ │ │ andhi pc, r8, sp, asr #17 │ │ │ │ @ instruction: 0xf8d44657 │ │ │ │ @ instruction: 0x46da8038 │ │ │ │ ldrdgt pc, [ip], -r4 │ │ │ │ ldmib r4, {r0, r1, r5, r7, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf1b82101 │ │ │ │ vpmax.f32 d16, d0, d0 │ │ │ │ strbtmi r8, [r0], #564 @ 0x234 │ │ │ │ mlaeq r0, r4, r8, pc @ │ │ │ │ @ instruction: 0xf8d46925 │ │ │ │ @ instruction: 0xf818e000 │ │ │ │ @ instruction: 0xf8523c01 │ │ │ │ @ instruction: 0xf1a34021 │ │ │ │ - blx fecdff00 │ │ │ │ + blx fecdfef8 │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ - bl fea37a6c │ │ │ │ + bl fea37a64 │ │ │ │ @ instruction: 0xf013030c │ │ │ │ suble r0, sp, r7, lsl #6 │ │ │ │ eorsle r2, pc, r1, lsl #22 │ │ │ │ eorsle r2, r4, r2, lsl #22 │ │ │ │ eorle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, lr, r4, lsl #22 │ │ │ │ andsle r2, r3, r5, lsl #22 │ │ │ │ andle r2, r8, r6, lsl #22 │ │ │ │ - blcc 9d374 │ │ │ │ + blcc 9d36c │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf81c3040 │ │ │ │ - blcs 2adf1c │ │ │ │ + blcs 2adf14 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcc 9d398 │ │ │ │ + blcc 9d390 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf81c3040 │ │ │ │ - blcs 2adf40 │ │ │ │ + blcs 2adf38 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcc 9d3bc │ │ │ │ + blcc 9d3b4 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf81c3040 │ │ │ │ - blcs 2adf64 │ │ │ │ + blcs 2adf5c │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ - blcc 9d3e0 │ │ │ │ + blcc 9d3d8 │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ strbmi r3, [r0, #64]! @ 0x40 │ │ │ │ stmdbge r8!, {r0, r1, r2, r3, r4, r5, sl, ip, sp, lr, pc} │ │ │ │ stcls 6, cr4, [r2], {99} @ 0x63 │ │ │ │ ldrmi r4, [sp], -ip, lsr #13 │ │ │ │ - blcc 9d3e4 │ │ │ │ + blcc 9d3dc │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ stmdavc fp!, {r6, ip, sp} │ │ │ │ tstle r4, sl, lsl #22 │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ stmdavc fp!, {r6, ip, sp}^ │ │ │ │ - blcs 2ac7d0 │ │ │ │ + blcs 2ac7c8 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ stccc 8, cr15, [r5], {21} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf8153040 │ │ │ │ - blcs 2ae3e8 │ │ │ │ + blcs 2ae3e0 │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ stccc 8, cr15, [r3], {21} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @ instruction: 0xf8153040 │ │ │ │ - blcs 2ae404 │ │ │ │ + blcs 2ae3fc │ │ │ │ @ instruction: 0xf8dbbf02 │ │ │ │ movwcc r3, #4160 @ 0x1040 │ │ │ │ subcc pc, r0, fp, asr #17 │ │ │ │ stccc 8, cr15, [r1], {21} │ │ │ │ svclt 0x00022b0a │ │ │ │ ldrdcc pc, [r0], #-139 @ 0xffffff75 │ │ │ │ @ instruction: 0xf8cb3301 │ │ │ │ @@ -14417,52 +14415,52 @@ │ │ │ │ stmdbcs r1, {r0, r1, fp, ip, sp, lr, pc} │ │ │ │ rscvs r9, r2, r1, lsl #20 │ │ │ │ @ instruction: 0x63a21a9a │ │ │ │ andcs r6, r0, #-1073741816 @ 0xc0000008 │ │ │ │ stccc 8, cr15, [r1], {27} │ │ │ │ stccs 8, cr15, [r1], {11} │ │ │ │ eorcc pc, r0, r4, lsl #17 │ │ │ │ - bcs 3a2d0 <__time64@plt+0x28fe8> │ │ │ │ + bcs 3a2c8 <__time64@plt+0x28fe0> │ │ │ │ ldmib r4, {r0, r2, r3, r8, sl, fp, ip, lr, pc}^ │ │ │ │ stmdavs r1!, {r1, r8, r9}^ │ │ │ │ @ instruction: 0xf8514413 │ │ │ │ @ instruction: 0xf8132020 │ │ │ │ @ instruction: 0xf1a33c01 │ │ │ │ - blx fece0088 │ │ │ │ + blx fece0080 │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ movwcs r6, #12755 @ 0x31d3 │ │ │ │ andcc pc, r0, r8, asr #17 │ │ │ │ movwne pc, #4672 @ 0x1240 @ │ │ │ │ ldmiblt r7!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf8949801 │ │ │ │ strmi r3, [r2], -r0, lsr #32 │ │ │ │ andcc pc, r0, fp, lsl #17 │ │ │ │ stmib r4, {r1, r3, r9, ip, sp}^ │ │ │ │ andcs r0, sl, #805306368 @ 0x30000000 │ │ │ │ strmi r6, [r2], -r2, lsr #7 │ │ │ │ - bvc fe039714 │ │ │ │ + bvc fe03970c │ │ │ │ @ instruction: 0xf8842300 │ │ │ │ addsvc r0, r3, #32 │ │ │ │ - bvc 14b9628 │ │ │ │ + bvc 14b9620 │ │ │ │ eorne pc, r1, r3, asr r8 @ │ │ │ │ andeq pc, sl, #-2147483608 @ 0x80000028 │ │ │ │ @ instruction: 0xf282fab2 │ │ │ │ movwne pc, #37440 @ 0x9240 @ │ │ │ │ bicvs r0, sl, r2, asr r9 │ │ │ │ ldmiblt r7, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf8949801 │ │ │ │ strmi r3, [r2], -r0, lsr #32 │ │ │ │ andcc pc, r0, fp, lsl #17 │ │ │ │ stmib r4, {r0, r3, r9, ip, sp}^ │ │ │ │ andcs r0, r9, #805306368 @ 0x30000000 │ │ │ │ strmi r6, [r2], -r2, lsr #7 │ │ │ │ - bvc 1039754 │ │ │ │ + bvc 103974c │ │ │ │ @ instruction: 0xf8842300 │ │ │ │ subsvc r0, r3, #32 │ │ │ │ - bvc 4b9668 │ │ │ │ + bvc 4b9660 │ │ │ │ eorne pc, r1, r3, asr r8 @ │ │ │ │ andeq pc, sl, #-2147483608 @ 0x80000028 │ │ │ │ @ instruction: 0xf282fab2 │ │ │ │ orrvc pc, r4, #1325400064 @ 0x4f000000 │ │ │ │ bicvs r0, sl, r2, asr r9 │ │ │ │ ldmiblt r7!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf89446a0 │ │ │ │ @@ -14475,15 +14473,15 @@ │ │ │ │ @ instruction: 0x71237920 │ │ │ │ ldrdcc pc, [r4], -r8 │ │ │ │ andscs pc, r0, r8, asr #17 │ │ │ │ @ instruction: 0xf85378e2 │ │ │ │ vst4.8 {d17-d20}, [pc :128], r1 │ │ │ │ @ instruction: 0xf1a27383 │ │ │ │ @ instruction: 0xf888020a │ │ │ │ - blx fec9f5b0 │ │ │ │ + blx fec9f5a8 │ │ │ │ ldmdbeq r2, {r1, r7, r9, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ff61ca │ │ │ │ ssatmi fp, #1, r4, lsl #19 │ │ │ │ mlacc r0, r4, r8, pc @ │ │ │ │ stcls 8, cr6, [r1], {161} @ 0xa1 │ │ │ │ andcc pc, r0, fp, lsl #17 │ │ │ │ stclne 3, cr2, [r2] │ │ │ │ @@ -14531,71 +14529,71 @@ │ │ │ │ andcs r4, r5, #805306368 @ 0x30000000 │ │ │ │ eorscs pc, r8, r8, asr #17 │ │ │ │ ldrdcs pc, [r4], -r8 │ │ │ │ cmnvc r3, r0, ror #18 │ │ │ │ @ instruction: 0xf8527923 │ │ │ │ @ instruction: 0xf1a32021 │ │ │ │ @ instruction: 0xf888030a │ │ │ │ - blx fecdf690 │ │ │ │ + blx fecdf688 │ │ │ │ ldmdbeq fp, {r0, r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ ldrb r6, [r2, #467]! @ 0x1d3 │ │ │ │ movwcs r9, #14593 @ 0x3901 │ │ │ │ mlacs r0, r4, r8, pc @ │ │ │ │ andcs pc, r0, fp, lsl #17 │ │ │ │ @ instruction: 0x63a32200 │ │ │ │ rscvs r1, r1, fp, asr #17 │ │ │ │ stmiavc fp, {r0, r1, r5, r8, sp, lr}^ │ │ │ │ @ instruction: 0xf88470ca │ │ │ │ - blvs fe8ab6b8 │ │ │ │ + blvs fe8ab6b0 │ │ │ │ vstrle s4, [sp, #-0] │ │ │ │ movweq lr, #10708 @ 0x29d4 │ │ │ │ ldrmi r6, [r3], #-2145 @ 0xfffff79f │ │ │ │ eorcs pc, r0, r1, asr r8 @ │ │ │ │ stccc 8, cr15, [r1], {19} │ │ │ │ movweq pc, #41379 @ 0xa1a3 @ │ │ │ │ @ instruction: 0xf383fab3 │ │ │ │ bicsvs r0, r3, fp, asr r9 │ │ │ │ orrvc pc, r0, #1325400064 @ 0x4f000000 │ │ │ │ stmdblt r1, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ mlacs r0, r4, r8, pc @ │ │ │ │ stmdavs r0!, {r0, r5, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf88b68e3 │ │ │ │ - bl feae7670 │ │ │ │ + bl feae7668 │ │ │ │ tstls r7, r3, lsl #6 │ │ │ │ eorcs pc, r1, r0, asr r8 @ │ │ │ │ movwls r3, #27393 @ 0x6b01 │ │ │ │ - bvs ff5036a0 │ │ │ │ + bvs ff503698 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ - bvs 187fba8 │ │ │ │ + bvs 187fba0 │ │ │ │ ldmdavs r3, {r5, r8, fp, sp, lr}^ │ │ │ │ andls r4, r4, r7, lsl #12 │ │ │ │ stmiavs r0!, {r0, r2, r3, r4, r6, fp, ip}^ │ │ │ │ @ instruction: 0xf08042bd │ │ │ │ tstcc r1, r0, ror r3 │ │ │ │ addmi r4, pc, #419430400 @ 0x19000000 │ │ │ │ movwhi pc, #29184 @ 0x7200 @ │ │ │ │ - bne ffa0ec │ │ │ │ + bne ffa0e4 │ │ │ │ cmple lr, r0, lsl #18 │ │ │ │ teqle r1, r1, lsl #30 │ │ │ │ @ instruction: 0x61206823 │ │ │ │ - bl ee2bc │ │ │ │ + bl ee2b4 │ │ │ │ ldrsbne r7, [fp], #-51 @ 0xffffffcd │ │ │ │ @ instruction: 0xf7fe3338 │ │ │ │ svcls 0x0003bfe9 │ │ │ │ @ instruction: 0xf7ff46a0 │ │ │ │ - blvs fe8ce47c │ │ │ │ + blvs fe8ce474 │ │ │ │ vstrle s4, [ip, #-0] │ │ │ │ movweq lr, #10708 @ 0x29d4 │ │ │ │ ldrmi r6, [r3], #-2145 @ 0xfffff79f │ │ │ │ eorcs pc, r0, r1, asr r8 @ │ │ │ │ stccc 8, cr15, [r1], {19} │ │ │ │ streq pc, [sl, #-419] @ 0xfffffe5d │ │ │ │ cmnmi fp, fp, ror #4 │ │ │ │ @ instruction: 0xf64c61d3 │ │ │ │ - vmla.i d18, d0, d0[2] │ │ │ │ + vmla.i d18, d0, d0[0] │ │ │ │ @ instruction: 0xf7fe0002 │ │ │ │ @ instruction: 0xf44ffe0f │ │ │ │ @ instruction: 0xf7ff7386 │ │ │ │ @ instruction: 0xf894b8b2 │ │ │ │ stmdbvs r5!, {r5} │ │ │ │ ldrd pc, [r0], -r4 │ │ │ │ svcge 0x0064f43e │ │ │ │ @@ -14614,23 +14612,23 @@ │ │ │ │ @ instruction: 0xf8d46925 │ │ │ │ @ instruction: 0xf43ee000 │ │ │ │ strbtmi sl, [r0], #3911 @ 0xf47 │ │ │ │ cdpne 4, 7, cr14, cr13, cr8, {2} │ │ │ │ vpadd.f32 d18, d0, d0 │ │ │ │ cdpne 3, 11, cr8, cr10, cr7, {0} │ │ │ │ vpmax.s8 d18, d0, d5 │ │ │ │ - bl fe900224 │ │ │ │ + bl fe90021c │ │ │ │ ldrmi r0, [sl], -r0, lsl #24 │ │ │ │ - ldclcc 1, cr15, [pc], #48 @ 1f794 <__time64@plt+0xe4ac> │ │ │ │ + ldclcc 1, cr15, [pc], #48 @ 1f78c <__time64@plt+0xe4a4> │ │ │ │ @ instruction: 0xf1bc9002 │ │ │ │ vmax.f32 d16, d0, d2 │ │ │ │ @ instruction: 0xf02582a8 │ │ │ │ stmiaeq r9!, {r0, r1, r9, sl, fp} │ │ │ │ stceq 1, cr15, [r4], {174} @ 0xae │ │ │ │ - bl 3c3ba0 │ │ │ │ + bl 3c3b98 │ │ │ │ tstls r5, r3, lsl #2 │ │ │ │ vldmiaeq ip, {s28-s106} │ │ │ │ stceq 1, cr15, [r1], {12} │ │ │ │ stceq 0, cr15, [r7], {28} │ │ │ │ rscshi pc, r1, #0 │ │ │ │ svceq 0x0001f1bc │ │ │ │ @ instruction: 0xf1bcd032 │ │ │ │ @@ -14639,39 +14637,39 @@ │ │ │ │ @ instruction: 0xf1bcd020 │ │ │ │ andsle r0, r7, r4, lsl #30 │ │ │ │ svceq 0x0005f1bc │ │ │ │ @ instruction: 0xf1bcd00e │ │ │ │ andle r0, r5, r6, lsl #30 │ │ │ │ @ instruction: 0xf8514601 │ │ │ │ tstls r2, r4, lsl #22 │ │ │ │ - blcc 15d8c8 │ │ │ │ + blcc 15d8c0 │ │ │ │ @ instruction: 0xf8519902 │ │ │ │ tstls r2, r4, lsl #22 │ │ │ │ - blcc 15d8d4 │ │ │ │ + blcc 15d8cc │ │ │ │ @ instruction: 0xf8519902 │ │ │ │ tstls r2, r4, lsl #22 │ │ │ │ - blcc 15d8e0 │ │ │ │ + blcc 15d8d8 │ │ │ │ @ instruction: 0xf8519902 │ │ │ │ tstls r2, r4, lsl #22 │ │ │ │ - blcc 15d8ec │ │ │ │ + blcc 15d8e4 │ │ │ │ @ instruction: 0xf8519902 │ │ │ │ tstls r2, r4, lsl #22 │ │ │ │ - blcc 15d8f8 │ │ │ │ + blcc 15d8f0 │ │ │ │ @ instruction: 0xf8519902 │ │ │ │ tstls r2, r4, lsl #22 │ │ │ │ - blcc 15d904 │ │ │ │ + blcc 15d8fc │ │ │ │ @ instruction: 0xf8519902 │ │ │ │ @ instruction: 0xf8423b04 │ │ │ │ - blls 16e418 │ │ │ │ + blls 16e410 │ │ │ │ addsmi r9, r3, #-2147483648 @ 0x80000000 │ │ │ │ @ instruction: 0xf8cdbf18 │ │ │ │ eorle sl, r8, r8 │ │ │ │ ldrmi r4, [r4], sl, lsl #13 │ │ │ │ - blcc 15d984 │ │ │ │ - blcc 15d950 │ │ │ │ + blcc 15d97c │ │ │ │ + blcc 15d948 │ │ │ │ @ instruction: 0xf10a684b │ │ │ │ subsvs r0, r3, ip, lsl r1 │ │ │ │ andseq pc, ip, #12, 2 │ │ │ │ ldrdcc pc, [r4], -sl │ │ │ │ andcc pc, r4, ip, asr #17 │ │ │ │ ldrdcc pc, [r8], -sl │ │ │ │ andcc pc, r8, ip, asr #17 │ │ │ │ @@ -14681,59 +14679,59 @@ │ │ │ │ andscc pc, r0, ip, asr #17 │ │ │ │ @ instruction: 0x3014f8da │ │ │ │ andscc pc, r4, ip, asr #17 │ │ │ │ @ instruction: 0x3018f8da │ │ │ │ andscc pc, r8, ip, asr #17 │ │ │ │ addsmi r9, r3, #5120 @ 0x1400 │ │ │ │ @ instruction: 0xf8ddd1d8 │ │ │ │ - bl 47888 <__time64@plt+0x365a0> │ │ │ │ + bl 47880 <__time64@plt+0x36598> │ │ │ │ strmi r0, [lr, #782]! @ 0x30e │ │ │ │ - bls 2938b0 │ │ │ │ + bls 2938a8 │ │ │ │ eorcs pc, r2, r0, lsl r8 @ │ │ │ │ andvc r9, r2, r5, lsl #16 │ │ │ │ andeq pc, r1, #-2147483645 @ 0x80000003 │ │ │ │ stcle 2, cr4, [r7, #-596] @ 0xfffffdac │ │ │ │ @ instruction: 0xf10e7859 │ │ │ │ adcmi r0, sl, #536870912 @ 0x20000000 │ │ │ │ - ble 7b990 │ │ │ │ + ble 7b988 │ │ │ │ umullvc r7, r3, fp, r8 │ │ │ │ movwcs lr, #31197 @ 0x79dd │ │ │ │ eorcs pc, r2, r3, asr r8 @ │ │ │ │ - blcs ba3e8 │ │ │ │ + blcs ba3e0 │ │ │ │ movwcs fp, #3842 @ 0xf02 │ │ │ │ rsbvs r6, r3, #-1073741820 @ 0xc0000004 │ │ │ │ mvnshi pc, r0 │ │ │ │ - blne 16f9bf8 │ │ │ │ - blcs 2e4b4 <__time64@plt+0x1d1cc> │ │ │ │ + blne 16f9bf0 │ │ │ │ + blcs 2e4ac <__time64@plt+0x1d1c4> │ │ │ │ @ instruction: 0xf8cddc41 │ │ │ │ ldrtmi r9, [r1], r8 │ │ │ │ @ instruction: 0xf8cd9e04 │ │ │ │ ssatmi r8, #25, r0 │ │ │ │ strtmi r4, [r5], -pc, lsr #12 │ │ │ │ ands r4, sl, r4, lsl r6 │ │ │ │ stmdbcs r0, {r0, r5, r6, r7, fp, sp, lr} │ │ │ │ subeq fp, r9, r8, asr #31 │ │ │ │ @ instruction: 0xf101dc05 │ │ │ │ svclt 0x00a80307 │ │ │ │ - bl 71108 │ │ │ │ + bl 71100 │ │ │ │ rscvs r0, r1, r3, ror #3 │ │ │ │ @ instruction: 0xf7f83102 │ │ │ │ rsbvs pc, r0, r3, asr #20 │ │ │ │ ldrdcc lr, [r1, -r5] │ │ │ │ @ instruction: 0x612e4406 │ │ │ │ eormi pc, r1, r3, asr r8 @ │ │ │ │ - blne ff6f9c84 │ │ │ │ - blcs 2e500 <__time64@plt+0x1d218> │ │ │ │ + blne ff6f9c7c │ │ │ │ + blcs 2e4f8 <__time64@plt+0x1d210> │ │ │ │ stmdbvs r3!, {r1, r4, sl, fp, ip, lr, pc}^ │ │ │ │ - bne db9a84 │ │ │ │ + bne db9a7c │ │ │ │ bicsle r2, pc, r0, lsl #22 │ │ │ │ - addscs pc, r4, ip, asr #12 │ │ │ │ + addcs pc, ip, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7fe6063 │ │ │ │ - bvs fe91ed14 │ │ │ │ + bvs fe91ed0c │ │ │ │ andsvs r6, r3, r1, lsl r9 │ │ │ │ rsbvs r2, r1, #67108864 @ 0x4000000 │ │ │ │ ssat r6, #18, r3, asr #5 │ │ │ │ strbmi r4, [lr], -r2, lsr #12 │ │ │ │ @ instruction: 0xf8dd462c │ │ │ │ ldrtmi r9, [sp], -r8 │ │ │ │ @ instruction: 0xf8dd4647 │ │ │ │ @@ -14741,28 +14739,28 @@ │ │ │ │ svclt 0x00a85f00 │ │ │ │ movwpl pc, #1103 @ 0x44f @ │ │ │ │ ldrmi r9, [r9], -r5, lsl #6 │ │ │ │ movwls r6, #10643 @ 0x2993 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ movwcs r8, #313 @ 0x139 │ │ │ │ andeq pc, r3, #17 │ │ │ │ - bcs 93a80 │ │ │ │ - bcs d3a14 │ │ │ │ - bvs fe8539b4 │ │ │ │ + bcs 93a78 │ │ │ │ + bcs d3a0c │ │ │ │ + bvs fe8539ac │ │ │ │ ldrdcs lr, [r1, -r0] │ │ │ │ @ instruction: 0xf080428a │ │ │ │ mrrcne 1, 7, r8, r1, cr7 │ │ │ │ ldmdavc r1, {r0, r6, sp, lr} │ │ │ │ @ instruction: 0xf000290a │ │ │ │ ldmib r4, {r0, r1, r2, r3, r4, r6, r8, pc}^ │ │ │ │ movwcs r0, #4609 @ 0x1201 │ │ │ │ eorgt pc, r2, r0, asr r8 @ │ │ │ │ ldrdgt pc, [r4], -ip │ │ │ │ @ instruction: 0xf80c44bc │ │ │ │ - bvs fe826990 │ │ │ │ + bvs fe826988 │ │ │ │ ldrdcs lr, [r1, -r0] │ │ │ │ @ instruction: 0xf080428a │ │ │ │ mrrcne 1, 0, r8, r1, cr6 │ │ │ │ ldmdavc r1, {r0, r6, sp, lr} │ │ │ │ @ instruction: 0xf000290a │ │ │ │ ldmib r4, {r0, r3, r6, r8, pc}^ │ │ │ │ @ instruction: 0xf8500201 │ │ │ │ @@ -14812,33 +14810,33 @@ │ │ │ │ stmdbcs sl, {r0, r3, fp, ip, sp, lr} │ │ │ │ rschi pc, r8, r0 │ │ │ │ ldrdcc lr, [r1], -r6 │ │ │ │ eorcs pc, r0, r3, asr r8 @ │ │ │ │ ldrdgt pc, [r4], -r2 │ │ │ │ stcne 4, cr4, [r5], #688 @ 0x2b0 │ │ │ │ @ instruction: 0xf80c44bc │ │ │ │ - bvs fec26a78 │ │ │ │ + bvs fec26a70 │ │ │ │ movwne lr, #6608 @ 0x19d0 │ │ │ │ @ instruction: 0xf0804299 │ │ │ │ mcrrne 0, 15, r8, fp, cr6 │ │ │ │ stmdavc r9, {r0, r1, r6, sp, lr} │ │ │ │ @ instruction: 0xf000290a │ │ │ │ ldmib r6, {r0, r4, r6, r7, pc}^ │ │ │ │ @ instruction: 0xf8533001 │ │ │ │ @ instruction: 0xf8d22020 │ │ │ │ - bls 18faa8 │ │ │ │ + bls 18faa0 │ │ │ │ stclne 4, cr4, [r5], #688 @ 0x2b0 │ │ │ │ adcmi r4, sl, #188, 8 @ 0xbc000000 │ │ │ │ stcne 8, cr15, [r1], {12} │ │ │ │ - bvs fec53ae0 │ │ │ │ + bvs fec53ad8 │ │ │ │ movwne lr, #6608 @ 0x19d0 │ │ │ │ svclt 0x003e4299 │ │ │ │ subvs r1, r3, fp, asr #24 │ │ │ │ orrsle r7, lr, #589824 @ 0x90000 │ │ │ │ - bl ff05da80 │ │ │ │ + bl ff15da78 │ │ │ │ mcrrne 6, 0, r4, r4, cr1 │ │ │ │ smulls sp, r8, r9, r1 │ │ │ │ ldrtmi r4, [r4], -r2, lsl #12 │ │ │ │ mcrls 6, 0, r4, cr2, cr8, {0} │ │ │ │ stcls 6, cr4, [r4, #-172] @ 0xffffff54 │ │ │ │ eorvc pc, r2, r0, asr r8 @ │ │ │ │ vdiveq.f64 d14, d2, d0 │ │ │ │ @@ -14850,84 +14848,84 @@ │ │ │ │ rsbvs r5, r1, #1107296256 @ 0x42000000 │ │ │ │ ldrdcc pc, [r0], -lr │ │ │ │ strmi r6, [fp], #-2139 @ 0xfffff7a5 │ │ │ │ @ instruction: 0xf8de705a │ │ │ │ ldmdavs r8, {ip, sp}^ │ │ │ │ rscvs r9, r0, r2, lsl #22 │ │ │ │ @ instruction: 0xf43f2b01 │ │ │ │ - blcs cb258 │ │ │ │ + blcs cb250 │ │ │ │ mcrge 4, 0, pc, cr1, cr15, {1} @ │ │ │ │ strbmi r9, [sp], -r6, lsl #22 │ │ │ │ strmi r4, [r3], #-1623 @ 0xfffff9a9 │ │ │ │ ldrmi r6, [r9], r3, lsr #2 │ │ │ │ - blx fe1ddb1a │ │ │ │ + blx fe1ddb12 │ │ │ │ movwls r6, #6371 @ 0x18e3 │ │ │ │ stcllt 7, cr15, [r3, #-1016]! @ 0xfffffc08 │ │ │ │ @ instruction: 0xf7f19302 │ │ │ │ - mcrrne 11, 8, lr, r3, cr8 │ │ │ │ - blls b1338 │ │ │ │ + mcrrne 11, 8, lr, r3, cr12 │ │ │ │ + blls b1330 │ │ │ │ svcge 0x0049f47f │ │ │ │ ldmdavs r2, {r1, r5, r7, r9, fp, sp, lr} │ │ │ │ eoreq pc, r0, #18 │ │ │ │ teqle r7, r2, lsl #4 │ │ │ │ ldrdcs lr, [r1, -r4] │ │ │ │ @ instruction: 0xf8526263 │ │ │ │ - bl bbbd4 │ │ │ │ + bl bbbcc │ │ │ │ teqvs fp, r1, lsl #29 │ │ │ │ bicle r2, r3, r0, lsl #22 │ │ │ │ @ instruction: 0xf0402d00 │ │ │ │ - bvs fe83fddc │ │ │ │ + bvs fe83fdd4 │ │ │ │ stc2l 7, cr15, [r8], {254} @ 0xfe │ │ │ │ ldmib r4, {r0, sp}^ │ │ │ │ andls r2, r2, r1, lsl #2 │ │ │ │ @ instruction: 0xf8526a63 │ │ │ │ - bl bbbf8 │ │ │ │ + bl bbbf0 │ │ │ │ ldr r0, [r3, r1, lsl #29]! │ │ │ │ cmneq r3, r1, lsl #22 │ │ │ │ @ instruction: 0xf7f89104 │ │ │ │ ldrshtvs pc, [r8], #-133 @ 0xffffff7b @ │ │ │ │ ldrdcs lr, [r1], -r4 │ │ │ │ @ instruction: 0xf8529904 │ │ │ │ - bl abc10 │ │ │ │ + bl abc08 │ │ │ │ ldmdavs r8, {r7, r9, sl, fp}^ │ │ │ │ eorsle r2, sp, r0, lsl #16 │ │ │ │ sbcsvs r3, r9, r2, lsl #18 │ │ │ │ stmiane r9!, {r0, r1, r5, r6, r9, fp, sp, lr}^ │ │ │ │ movwls lr, #10147 @ 0x27a3 │ │ │ │ - bl 12ddb6c │ │ │ │ + bl 13ddb64 │ │ │ │ strmi r9, [r1], -r2, lsl #22 │ │ │ │ @ instruction: 0xf47f1c42 │ │ │ │ @ instruction: 0xe7c1aef5 │ │ │ │ - sbccs pc, r0, ip, asr #12 │ │ │ │ + adcscs pc, r8, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx feaddbba │ │ │ │ + blx feaddbb2 │ │ │ │ @ instruction: 0xf7f19204 │ │ │ │ - blls da7c8 │ │ │ │ - bls 1313e8 │ │ │ │ + blls da7d0 │ │ │ │ + bls 1313e0 │ │ │ │ and r6, lr, r3 │ │ │ │ stmdavs r2, {r5, r7, r9, fp, sp, lr} │ │ │ │ eoreq pc, r0, #18 │ │ │ │ ldmdavs sl!, {r1, r5, ip, lr, pc} │ │ │ │ mvnle r2, r4, lsl #20 │ │ │ │ @ instruction: 0xf7f1603b │ │ │ │ - ldmib r4, {r1, r4, r6, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + ldmib r4, {r1, r2, r4, r6, r8, r9, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf8533201 │ │ │ │ ldmdavs r0, {r1, r5, sp}^ │ │ │ │ - bvs fe8e7ff8 │ │ │ │ + bvs fe8e7ff0 │ │ │ │ strtmi r9, [r8], #-2565 @ 0xfffff5fb │ │ │ │ - bl 165dbc0 │ │ │ │ + bl 175dbb8 │ │ │ │ rsbvs r4, r0, #3145728 @ 0x300000 │ │ │ │ rscle r2, r5, r0, lsl #16 │ │ │ │ ldrdcs lr, [r1, -r4] │ │ │ │ eorvc pc, r1, r2, asr r8 @ │ │ │ │ vdiveq.f64 d14, d1, d2 │ │ │ │ @ instruction: 0xe7656138 │ │ │ │ - rsccs pc, r0, ip, asr #12 │ │ │ │ + sbcscs pc, r8, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx 1eddc1a │ │ │ │ + blx 1eddc12 │ │ │ │ ldrdcc lr, [r1, -r4] │ │ │ │ eorcc pc, r1, r3, asr r8 @ │ │ │ │ @ instruction: 0xe795611a │ │ │ │ ldrtmi r4, [r4], -fp, lsr #12 │ │ │ │ cdpls 13, 0, cr9, cr2, cr4, {0} │ │ │ │ @ instruction: 0x7c01e9d4 │ │ │ │ andls r2, r2, #0, 4 │ │ │ │ @@ -14935,61 +14933,61 @@ │ │ │ │ eorcs pc, ip, r7, asr r8 @ │ │ │ │ vdiveq.f64 d14, d12, d7 │ │ │ │ strtmi r6, [sl], #-2130 @ 0xfffff7ae │ │ │ │ @ instruction: 0x460354d1 │ │ │ │ eorvc pc, ip, r7, asr r8 @ │ │ │ │ smlaldx r6, r3, r8, r1 │ │ │ │ @ instruction: 0xf7f19302 │ │ │ │ - @ instruction: 0x4601eaf0 │ │ │ │ + @ instruction: 0x4601eaf4 │ │ │ │ mcrrne 11, 0, r9, r8, cr2 │ │ │ │ mcrge 4, 4, pc, cr4, cr15, {3} @ │ │ │ │ @ instruction: 0xf7f1e766 │ │ │ │ - strmi lr, [r1], -r8, ror #21 │ │ │ │ + strmi lr, [r1], -ip, ror #21 │ │ │ │ @ instruction: 0xf47f1c43 │ │ │ │ strtmi sl, [fp], -r7, lsl #30 │ │ │ │ stcls 6, cr4, [r4, #-208] @ 0xffffff30 │ │ │ │ ldrb r9, [fp, -r2, lsl #28] │ │ │ │ - b ff75dc48 │ │ │ │ + b ff85dc40 │ │ │ │ mcrrne 6, 0, r4, r2, cr1 │ │ │ │ mcrge 4, 7, pc, cr5, cr15, {3} @ │ │ │ │ @ instruction: 0xf7f1e7f3 │ │ │ │ - @ instruction: 0x4601ead6 │ │ │ │ + @ instruction: 0x4601eada │ │ │ │ @ instruction: 0xf47f1c48 │ │ │ │ strb sl, [ip, r7, asr #29]! │ │ │ │ ldrdne lr, [r1], -r4 │ │ │ │ - bvs 18e84ac │ │ │ │ + bvs 18e84a4 │ │ │ │ @ instruction: 0xf8519202 │ │ │ │ - bl 7bd2c │ │ │ │ + bl 7bd24 │ │ │ │ rscsvs r0, sl, #128, 28 @ 0x800 │ │ │ │ @ instruction: 0xf64ce716 │ │ │ │ - vmov.i32 q9, #12 @ 0x0000000c │ │ │ │ + vmov.i32 q9, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf7fe0002 │ │ │ │ - bl 11e96c │ │ │ │ + bl 11e964 │ │ │ │ @ instruction: 0xf0150e05 │ │ │ │ eorle r0, sl, r7, lsl #4 │ │ │ │ eorle r2, r1, r1, lsl #20 │ │ │ │ andsle r2, fp, r2, lsl #20 │ │ │ │ andsle r2, r5, r3, lsl #20 │ │ │ │ andle r2, pc, r4, lsl #20 │ │ │ │ andle r2, r9, r5, lsl #20 │ │ │ │ andle r2, r3, r6, lsl #20 │ │ │ │ + blcs 9dd1c │ │ │ │ + blcs 9dcec │ │ │ │ blcs 9dd24 │ │ │ │ blcs 9dcf4 │ │ │ │ blcs 9dd2c │ │ │ │ blcs 9dcfc │ │ │ │ blcs 9dd34 │ │ │ │ blcs 9dd04 │ │ │ │ blcs 9dd3c │ │ │ │ blcs 9dd0c │ │ │ │ blcs 9dd44 │ │ │ │ blcs 9dd14 │ │ │ │ blcs 9dd4c │ │ │ │ blcs 9dd1c │ │ │ │ - blcs 9dd54 │ │ │ │ - blcs 9dd24 │ │ │ │ @ instruction: 0xf43f4573 │ │ │ │ @ instruction: 0x4601adb9 │ │ │ │ @ instruction: 0xf811469c │ │ │ │ @ instruction: 0xf80c2b01 │ │ │ │ vstrne d18, [r8, #4] │ │ │ │ movweq pc, #28940 @ 0x710c @ │ │ │ │ ldrbmi r7, [r3, #-2058]! @ 0xfffff7f6 │ │ │ │ @@ -15000,23 +14998,23 @@ │ │ │ │ @ instruction: 0xf88c78ca │ │ │ │ stmdbvc sl, {r0, r1, sp} │ │ │ │ andcs pc, r4, ip, lsl #17 │ │ │ │ @ instruction: 0xf88c794a │ │ │ │ stmibvc sl, {r0, r2, sp} │ │ │ │ stccs 8, cr15, [r1], {3} │ │ │ │ ldr sp, [r7, #479] @ 0x1df │ │ │ │ - blcs ba8b0 │ │ │ │ + blcs ba8a8 │ │ │ │ movwcs fp, #3842 @ 0xf02 │ │ │ │ rsbvs r6, r3, #-1073741820 @ 0xc0000004 │ │ │ │ ldcge 4, cr15, [ip, #508] @ 0x1fc │ │ │ │ @ instruction: 0x4601e6f2 │ │ │ │ andge pc, r8, sp, asr #17 │ │ │ │ stcls 5, cr14, [r6, #-304] @ 0xfffffed0 │ │ │ │ @ instruction: 0x61254405 │ │ │ │ - blx 155dd7c │ │ │ │ + blx 155dd74 │ │ │ │ movteq lr, #2822 @ 0xb06 │ │ │ │ subeq r4, r1, r2, lsl #12 │ │ │ │ @ instruction: 0x3100f9b3 │ │ │ │ stmib r4, {r0, r1, r4, r5, r8, ip, sp, pc}^ │ │ │ │ and r0, r3, r5, lsl #10 │ │ │ │ @ instruction: 0xf9b14431 │ │ │ │ subseq r2, r1, r8, asr sl │ │ │ │ @@ -15024,34 +15022,34 @@ │ │ │ │ movwcc r3, #5500 @ 0x157c │ │ │ │ andseq pc, r3, r8, lsr r9 @ │ │ │ │ mvnsle r4, r2, lsl #5 │ │ │ │ andseq pc, r3, r9, lsr r9 @ │ │ │ │ @ instruction: 0xf5b068e3 │ │ │ │ movwls r7, #7951 @ 0x1f0f │ │ │ │ ldmdblt r8, {ip, lr, pc} │ │ │ │ - blge 19a514 │ │ │ │ + blge 19a50c │ │ │ │ mrrclt 7, 15, pc, r4, cr14 @ │ │ │ │ strtmi r4, [r9], fp, asr #12 │ │ │ │ @ instruction: 0x461d4657 │ │ │ │ stmdbeq r1, {r0, r3, r8, ip, sp, lr, pc} │ │ │ │ stclt 7, cr15, [fp], {254} @ 0xfe │ │ │ │ - andscc pc, r0, ip, asr #12 │ │ │ │ + andcc pc, r8, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx fe65dddc │ │ │ │ + blx fe65ddd4 │ │ │ │ eorsle r2, r4, r0, lsl #16 │ │ │ │ @ instruction: 0x4604b570 │ │ │ │ - blx fe8ddde8 │ │ │ │ + blx fe8ddde0 │ │ │ │ bicsvs pc, ip, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ andne lr, r1, #3457024 @ 0x34c000 │ │ │ │ addeq lr, r2, r1, lsl #22 │ │ │ │ @ instruction: 0xf851b1d1 │ │ │ │ @ instruction: 0xb1bd5022 │ │ │ │ @ instruction: 0xf893691d │ │ │ │ - bvs 17cfe90 │ │ │ │ + bvs 17cfe88 │ │ │ │ andgt pc, r0, r5, lsl #17 │ │ │ │ eorne pc, r2, r1, asr r8 @ │ │ │ │ addsvs r3, sl, r1, lsl #4 │ │ │ │ stmdavs r5!, {r0, r2, r3, r7, sp, lr} │ │ │ │ smlatbvs lr, r2, r8, r6 │ │ │ │ sbcsvs r6, sl, r4, asr #32 │ │ │ │ @ instruction: 0x611a629d │ │ │ │ @@ -15091,39 +15089,39 @@ │ │ │ │ @ instruction: 0xff50f7f7 │ │ │ │ strmi r2, [r4], -r1, lsl #6 │ │ │ │ strpl lr, [r1, #-2496] @ 0xfffff640 │ │ │ │ stmib r0, {r1, r2, sp, lr}^ │ │ │ │ stmib r0, {r0, r1, r8, r9, sl, ip, sp, lr}^ │ │ │ │ bicvs r6, r3, r5, lsl #12 │ │ │ │ strvs lr, [sl], -r0, asr #19 │ │ │ │ - blx 165dec8 │ │ │ │ + blx 165dec0 │ │ │ │ ldcllt 6, cr4, [r8, #128]! @ 0x80 │ │ │ │ strtmi r2, [r0], -r0, lsl #8 │ │ │ │ svclt 0x0000bdf8 │ │ │ │ stcne 5, cr11, [pc], {248} @ 0xf8 │ │ │ │ strmi r4, [r6], -ip, lsl #12 │ │ │ │ @ instruction: 0xf7f74638 │ │ │ │ stccs 15, cr15, [r0], {53} @ 0x35 │ │ │ │ stcle 6, cr4, [sp, #-20] @ 0xffffffec │ │ │ │ @ instruction: 0x46224631 │ │ │ │ - ldm ip, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmia r0!, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrtmi r2, [r9], -r0, lsl #6 │ │ │ │ @ instruction: 0x532b4628 │ │ │ │ @ instruction: 0xffcaf7ff │ │ │ │ movwcs fp, #4424 @ 0x1148 │ │ │ │ ldcllt 1, cr6, [r8, #268]! @ 0x10c │ │ │ │ ldrtmi r2, [r9], -r0, lsl #6 │ │ │ │ @ instruction: 0xf7ff5303 │ │ │ │ stmdacs r0, {r0, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf64cd1f5 │ │ │ │ - vmla.i d19, d0, d0[1] │ │ │ │ + vmvn.i32 d19, #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7fe0002 │ │ │ │ svclt 0x0000f9f7 │ │ │ │ @ instruction: 0x4604b510 │ │ │ │ - ldmdb r0!, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmdb r4!, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ strtmi r4, [r0], -r1, lsl #12 │ │ │ │ @ instruction: 0x4010e8bd │ │ │ │ svclt 0x00d0f7ff │ │ │ │ @ instruction: 0x33bcf240 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0x47706818 │ │ │ │ bicsvs pc, ip, #64, 4 │ │ │ │ @@ -15156,97 +15154,97 @@ │ │ │ │ vqrshl.s8 , q12, q8 │ │ │ │ @ instruction: 0xf2c066dc │ │ │ │ ldmdavs r5!, {r0, r2, r9, sl}^ │ │ │ │ ldmvs r4!, {r0, r2, r4, r7, r8, ip, sp, pc} │ │ │ │ eoreq pc, r4, r5, asr r8 @ │ │ │ │ streq lr, [r4], #2821 @ 0xb05 │ │ │ │ strcs fp, [r0, -r0, ror #2] │ │ │ │ - blx 2ddfcc │ │ │ │ + blx 2ddfc4 │ │ │ │ @ instruction: 0xf7ff6027 │ │ │ │ ldmvs r4!, {r0, r2, r3, r4, r5, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ eoreq pc, r4, r5, asr r8 @ │ │ │ │ streq lr, [r4], #2821 @ 0xb05 │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ @ instruction: 0xf7f14628 │ │ │ │ - andcs lr, r0, sl, lsl r8 │ │ │ │ + andcs lr, r0, lr, lsl r8 │ │ │ │ andeq lr, r1, r6, asr #19 │ │ │ │ teqvs r0, r0 @ │ │ │ │ ldrshtvs r6, [r0], -r0 │ │ │ │ teqvs r0, #176, 4 │ │ │ │ svclt 0x0000bdf8 │ │ │ │ mcrlt 7, 5, pc, cr6, cr7, {7} @ │ │ │ │ mrclt 7, 5, APSR_nzcv, cr0, cr7, {7} │ │ │ │ - stmdalt r6, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdalt sl, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ vqrshl.s8 d27, d24, d0 │ │ │ │ @ instruction: 0xf2c064dc │ │ │ │ vshl.s8 d16, d5, d11 │ │ │ │ - vaddw.s8 q10, q0, d20 │ │ │ │ + vorr.i32 d20, #12 @ 0x0000000c │ │ │ │ strmi r0, [r5], -r2, lsl #2 │ │ │ │ - @ instruction: 0xff15f7f4 │ │ │ │ + @ instruction: 0xff19f7f4 │ │ │ │ teqlt r0, r0, lsr #5 │ │ │ │ @ instruction: 0xf7fe4628 │ │ │ │ movwcs pc, #6341 @ 0x18c5 @ │ │ │ │ movweq lr, #63940 @ 0xf9c4 │ │ │ │ @ instruction: 0x4628bd38 │ │ │ │ - ldmda r8!, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda ip!, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7f12001 │ │ │ │ - svclt 0x0000e89a │ │ │ │ + svclt 0x0000e89e │ │ │ │ bicsvs pc, ip, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf7f16a98 │ │ │ │ - svclt 0x0000b8eb │ │ │ │ + svclt 0x0000b8ef │ │ │ │ vshl.s8 d27, d15, d0 │ │ │ │ vorr.i32 d23, #2048 @ 0x00000800 │ │ │ │ ldrlt r0, [r0, #-773] @ 0xfffffcfb │ │ │ │ ldrbcc pc, [r8], #576 @ 0x240 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ addlt r6, r2, sl, lsl r8 │ │ │ │ stmdavs r0!, {r0, r1, r3, r4, r6, fp, sp, lr} │ │ │ │ andcc fp, r9, #-2147483648 @ 0x80000000 │ │ │ │ - msrcc (UNDEF: 100), ip │ │ │ │ + cmppcc ip, ip, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldm r4, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - bge 186498 │ │ │ │ + ldm r8, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bge 186490 │ │ │ │ andls r6, r1, #32, 16 @ 0x200000 │ │ │ │ - stmia r8!, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia ip!, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldmib r0, {r5, fp, sp, lr}^ │ │ │ │ addsmi r3, r3, #1342177280 @ 0x50000000 │ │ │ │ mrrcne 15, 3, fp, r9, cr15 │ │ │ │ cmpvs r1, sl, lsl #4 │ │ │ │ andle r7, sl, #26 │ │ │ │ movwmi pc, #16960 @ 0x4240 @ │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ andsvc r2, sl, r1, lsl #4 │ │ │ │ pop {r1, ip, sp, pc} │ │ │ │ andlt r4, r4, r0, lsl r0 │ │ │ │ tstcs sl, r0, ror r7 │ │ │ │ - stmia r4, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia r8, {r0, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ svclt 0x0000e7f0 │ │ │ │ ldmcs pc!, {r0, r1, r9, sl, lr}^ @ │ │ │ │ @ instruction: 0xf5b0dd1d │ │ │ │ stcle 15, cr7, [ip, #-532] @ 0xfffffdec │ │ │ │ vld2.8 {d27-d30}, [pc], r1 │ │ │ │ ldrmi r7, [r3], #-645 @ 0xfffffd7b │ │ │ │ - rsbvs pc, ip, #536870916 @ 0x20000004 │ │ │ │ + rsbvs pc, r4, #536870916 @ 0x20000004 │ │ │ │ andeq pc, r3, #192, 4 │ │ │ │ addeq lr, r3, #2048 @ 0x800 │ │ │ │ @ instruction: 0xf0076c90 │ │ │ │ @ instruction: 0xf5a0bb7b │ │ │ │ vcgt.s8 d23, d18, d0 │ │ │ │ - vmlal.s q11, d0, d0[7] │ │ │ │ + vmlal.s q11, d0, d0[5] │ │ │ │ @ instruction: 0xf64c0203 │ │ │ │ - vmvn.i32 , #12 @ 0x0000000c │ │ │ │ + vmvn.i32 , #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf8520002 │ │ │ │ @ instruction: 0xf0071023 │ │ │ │ @ instruction: 0xf64cbb6d │ │ │ │ - vaddl.s8 q10, d0, d4 │ │ │ │ + vshr.s64 , q14, #64 │ │ │ │ ldrmi r0, [r9], -r2 │ │ │ │ - bllt 19dc130 │ │ │ │ + bllt 19dc128 │ │ │ │ orrvc pc, r0, #160, 10 @ 0x28000000 │ │ │ │ - rsbvs pc, ip, #536870916 @ 0x20000004 │ │ │ │ + rsbvs pc, r4, #536870916 @ 0x20000004 │ │ │ │ andeq pc, r3, #192, 4 │ │ │ │ eoreq pc, r3, r2, asr r8 @ │ │ │ │ svclt 0x00004770 │ │ │ │ vqrshl.s8 , q12, q8 │ │ │ │ vaddhn.i16 d23, q0, q10 │ │ │ │ strmi r0, [r5], -r5, lsl #8 │ │ │ │ teqlt pc, r7, lsr #20 │ │ │ │ @@ -15254,52 +15252,52 @@ │ │ │ │ adcsmi r6, r0, #2555904 @ 0x270000 │ │ │ │ tstle sl, r3, lsr #4 │ │ │ │ ldcllt 6, cr4, [r8, #224]! @ 0xe0 │ │ │ │ @ instruction: 0xf7fe4620 │ │ │ │ eorvc pc, r7, #86016 @ 0x15000 │ │ │ │ stmdavs r7!, {r1, r2, r9, sl, lr} │ │ │ │ rsbvs r4, r0, r5, lsl #5 │ │ │ │ - ldclcs 0, cr13, [pc, #976]! @ 2052c <__time64@plt+0xf244> │ │ │ │ + ldclcs 0, cr13, [pc, #976]! @ 20524 <__time64@plt+0xf23c> │ │ │ │ @ instruction: 0xf5b5dd19 │ │ │ │ - ldcle 15, cr7, [pc, #-532] @ 1ff50 <__time64@plt+0xec68> │ │ │ │ + ldcle 15, cr7, [pc, #-532] @ 1ff48 <__time64@plt+0xec60> │ │ │ │ strvc pc, [r0, #1445] @ 0x5a5 │ │ │ │ - msrvs SPSR_fs, #536870916 @ 0x20000004 │ │ │ │ + msrvs SPSR_s, #536870916 @ 0x20000004 │ │ │ │ movweq pc, #12992 @ 0x32c0 @ │ │ │ │ eormi pc, r5, r3, asr r8 @ │ │ │ │ @ instruction: 0x46304639 │ │ │ │ @ instruction: 0xffa4f7ff │ │ │ │ strmi r2, [r2], -r0, lsl #14 │ │ │ │ @ instruction: 0xf64c4621 │ │ │ │ - vaddl.s8 , d16, d8 │ │ │ │ + vaddl.s8 , d16, d0 │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ ldrtmi pc, [r8], -r5, ror #30 @ │ │ │ │ @ instruction: 0x4629bdf8 │ │ │ │ - andmi pc, r4, ip, asr #12 │ │ │ │ + rscscc pc, ip, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx 85c1be │ │ │ │ + blx 85c1b6 │ │ │ │ strb r4, [r7, r4, lsl #12]! │ │ │ │ - orrcc pc, r4, ip, asr #12 │ │ │ │ + cmnpcc ip, ip, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - rsbscc pc, ip, ip, asr #12 │ │ │ │ + rsbscc pc, r4, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx 55c1d6 │ │ │ │ + blx 55c1ce │ │ │ │ ldrb r4, [fp, r4, lsl #12] │ │ │ │ vqrshl.s8 , q8, q0 │ │ │ │ vaddhn.i16 d23, q0, q10 │ │ │ │ strmi r0, [r6], -r5, lsl #8 │ │ │ │ @ instruction: 0xf7ff460d │ │ │ │ - bvc 920084 │ │ │ │ + bvc 92007c │ │ │ │ stmdavs r2!, {r0, r1, r4, r6, r7, r8, ip, sp, pc}^ │ │ │ │ eorle r2, r3, fp, asr sl │ │ │ │ @ instruction: 0xdc0d2a5b │ │ │ │ eorsle r2, r3, r8, lsr #20 │ │ │ │ eorle r2, r3, r9, lsr #20 │ │ │ │ @ instruction: 0x462ab972 │ │ │ │ @ instruction: 0xf64c4631 │ │ │ │ - vaddl.s8 , d16, d16 │ │ │ │ + vshr.s64 d19, d8, #64 │ │ │ │ ldmfd sp!, {r1} │ │ │ │ @ instruction: 0xe72f4070 │ │ │ │ eorle r2, fp, fp, ror sl │ │ │ │ nopeq {34} @ 0x22 │ │ │ │ andsle r2, r3, sp, asr fp │ │ │ │ eorvc r2, r3, #0, 6 │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ @@ -15309,15 +15307,15 @@ │ │ │ │ rsbvs r2, r0, fp, asr r8 │ │ │ │ bicsle r7, fp, r3, lsr #4 │ │ │ │ subscs r2, fp, sp, asr r1 │ │ │ │ @ instruction: 0xffcaf7ff │ │ │ │ ldrb r7, [r1, r3, lsr #20] │ │ │ │ @ instruction: 0xb1bb7a23 │ │ │ │ mulle r6, r5, r2 │ │ │ │ - sbcscc pc, r8, ip, asr #12 │ │ │ │ + sbcscc pc, r0, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ff4629 │ │ │ │ movwcs pc, #3851 @ 0xf0b @ │ │ │ │ ldcllt 2, cr7, [r0, #-140]! @ 0xffffff74 │ │ │ │ ldrmi r2, [r0], -r9, lsr #2 │ │ │ │ @ instruction: 0xffb6f7ff │ │ │ │ ldr r7, [sp, r3, lsr #20]! │ │ │ │ @@ -15328,27 +15326,27 @@ │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0xf986f7fe │ │ │ │ strmi r2, [r2], -r1, lsl #6 │ │ │ │ eorvc r6, r3, #96 @ 0x60 │ │ │ │ svclt 0x0000e7dc │ │ │ │ vqrshl.s8 d27, d0, d0 │ │ │ │ vaddhn.i16 d23, q0, q10 │ │ │ │ - bvc 8e1298 │ │ │ │ + bvc 8e1290 │ │ │ │ eorsle r2, r9, r0, lsl #22 │ │ │ │ - blcs 177a418 │ │ │ │ + blcs 177a410 │ │ │ │ @ instruction: 0xf1a3dc42 │ │ │ │ - blcs 9e0b34 │ │ │ │ - bcs d9782c │ │ │ │ + blcs 9e0b2c │ │ │ │ + bcs d97824 │ │ │ │ ldm pc, {r1, r2, r3, r5, fp, ip, lr, pc}^ @ │ │ │ │ cmppmi r5, #2 @ p-variant is OBSOLETE │ │ │ │ ldclcs 13, cr2, [lr, #-180] @ 0xffffff4c │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ - blne b76f68 │ │ │ │ + blne b76f60 │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ stccs 13, cr2, [sp, #-180]! @ 0xffffff4c │ │ │ │ @@ -15372,33 +15370,33 @@ │ │ │ │ mvnle r2, fp, ror fp │ │ │ │ @ instruction: 0x4618217d │ │ │ │ @ instruction: 0xff4ef7ff │ │ │ │ ldclt 0, cr2, [r0, #-0] │ │ │ │ ldrmi r6, [r8], -r1, lsr #16 │ │ │ │ mcr2 7, 6, pc, cr12, cr15, {7} @ │ │ │ │ @ instruction: 0xf64c4601 │ │ │ │ - vaddl.s8 q10, d0, d12 │ │ │ │ + vaddl.s8 q10, d0, d4 │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ ldrb pc, [r1, pc, lsl #29]! @ │ │ │ │ subscs r2, fp, sp, asr r1 │ │ │ │ @ instruction: 0xff3cf7ff │ │ │ │ ldr r7, [sp, r3, lsr #20] │ │ │ │ eorcs r2, r8, r9, lsr #2 │ │ │ │ @ instruction: 0xff36f7ff │ │ │ │ ldr r7, [r7, r3, lsr #20] │ │ │ │ eorvc r2, r3, #0, 6 │ │ │ │ movwcs lr, #2018 @ 0x7e2 │ │ │ │ eorvc r2, r3, #1 │ │ │ │ - blcs 4f7a4 <__time64@plt+0x3e4bc> │ │ │ │ + blcs 4f79c <__time64@plt+0x3e4b4> │ │ │ │ @ instruction: 0xf64cd1c8 │ │ │ │ - vmvn.i32 d20, #12 @ 0x0000000c │ │ │ │ + vmvn.i32 d20, #4 @ 0x00000004 │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ @ instruction: 0xe7d5fe73 │ │ │ │ @ instruction: 0xf7ff217d │ │ │ │ - bvc 920000 │ │ │ │ + bvc 91fff8 │ │ │ │ svclt 0x0000e782 │ │ │ │ vqrshl.s8 d27, d24, d0 │ │ │ │ vaddhn.i16 d23, q0, q10 │ │ │ │ strmi r0, [r5], -r5, lsl #8 │ │ │ │ cmnlt r3, r3, lsr #20 │ │ │ │ @ instruction: 0xf5b06860 │ │ │ │ tstle r3, r8, lsl #31 │ │ │ │ @@ -15413,93 +15411,93 @@ │ │ │ │ rsbvs r7, r0, r8, lsl #31 │ │ │ │ rscle r7, fp, r3, lsr #4 │ │ │ │ andle r2, r1, r8, lsr #16 │ │ │ │ ldclt 6, cr4, [r8, #-160]! @ 0xffffff60 │ │ │ │ @ instruction: 0xf7ff2129 │ │ │ │ @ instruction: 0x4628fef7 │ │ │ │ @ instruction: 0xffd6f7ff │ │ │ │ - rsbsmi pc, r4, ip, asr #12 │ │ │ │ + rsbmi pc, ip, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrhtmi lr, [r8], -sp │ │ │ │ ldmdalt lr!, {r0, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ addvc pc, r7, pc, asr #8 │ │ │ │ mrc2 7, 4, pc, cr12, cr15, {7} │ │ │ │ vcge.s8 d27, d16, d16 │ │ │ │ vabal.s8 , d0, d20 │ │ │ │ strmi r0, [r4], -r5, lsl #10 │ │ │ │ - beq 9c53c │ │ │ │ + beq 9c534 │ │ │ │ stmdbeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ stmdavs fp!, {r0, r2, r3, r4, sp, lr, pc}^ │ │ │ │ svcvc 0x0087f5b3 │ │ │ │ @ instruction: 0xf8d5d125 │ │ │ │ strtmi r8, [r0], -r0 │ │ │ │ andls pc, r8, r5, lsl #17 │ │ │ │ - mrc 7, 5, APSR_nzcv, cr10, cr0, {7} │ │ │ │ + mrc 7, 5, APSR_nzcv, cr14, cr0, {7} │ │ │ │ strbmi r4, [r0], -r6, lsl #12 │ │ │ │ - mrc 7, 5, APSR_nzcv, cr6, cr0, {7} │ │ │ │ + mrc 7, 5, APSR_nzcv, cr10, cr0, {7} │ │ │ │ ldmibne r1!, {r0, r1, r2, r9, sl, lr}^ │ │ │ │ tstcc r1, r0, lsr #12 │ │ │ │ ldc2 7, cr15, [lr], {247} @ 0xf7 │ │ │ │ @ instruction: 0x46041c7a │ │ │ │ ldrtmi r4, [r0], #-1601 @ 0xfffff9bf │ │ │ │ - ldcl 7, cr15, [sl, #960]! @ 0x3c0 │ │ │ │ + ldcl 7, cr15, [lr, #960]! @ 0x3c0 │ │ │ │ @ instruction: 0xf7f04640 │ │ │ │ - bvc b1bc04 │ │ │ │ + bvc b1bc0c │ │ │ │ bicsle r2, lr, r0, lsl #22 │ │ │ │ @ instruction: 0xf7fe4628 │ │ │ │ @ instruction: 0xf885f895 │ │ │ │ @ instruction: 0xf5b0a008 │ │ │ │ rsbvs r7, r8, r7, lsl #31 │ │ │ │ @ instruction: 0x4620d0d9 │ │ │ │ @ instruction: 0x87f0e8bd │ │ │ │ - strbmi pc, [r4], #586 @ 0x24a @ │ │ │ │ + ldrtmi pc, [ip], #586 @ 0x24a @ │ │ │ │ streq pc, [r2], #-704 @ 0xfffffd40 │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ svclt 0x000087f0 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ strtvc pc, [r4], #-576 @ 0xfffffdc0 │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ andcs fp, r0, #139 @ 0x8b │ │ │ │ strmi r4, [sp], -r1, lsl #13 │ │ │ │ andvs r7, r2, r3, lsr #20 │ │ │ │ stmdavs r0!, {r0, r1, r6, r7, r8, ip, sp, pc}^ │ │ │ │ orrvc pc, r0, #1862270976 @ 0x6f000000 │ │ │ │ - blcs 4267a0 │ │ │ │ + blcs 426798 │ │ │ │ ldm pc, {r4, r5, fp, ip, lr, pc}^ @ │ │ │ │ adcseq pc, r2, r3, lsl r0 @ │ │ │ │ eoreq r0, pc, pc, lsr #32 │ │ │ │ subeq r0, r4, r4, asr #32 │ │ │ │ eoreq r0, pc, r1, asr #1 │ │ │ │ eoreq r0, pc, pc, lsr #32 │ │ │ │ eoreq r0, pc, pc, lsr #32 │ │ │ │ ldrshteq r0, [lr], #11 │ │ │ │ eoreq r0, pc, pc, lsr #32 │ │ │ │ adcseq r0, sp, pc, lsr #32 │ │ │ │ @ instruction: 0xf7fe4620 │ │ │ │ vld2.16 {d31-d32}, [pc :64], fp │ │ │ │ movwcs r7, #4736 @ 0x1280 │ │ │ │ stmne r3, {r0, r1, r5, r9, ip, sp, lr} │ │ │ │ - blcs 438650 │ │ │ │ + blcs 438648 │ │ │ │ ldm pc, {r1, r4, fp, ip, lr, pc}^ @ │ │ │ │ addseq pc, r4, r3, lsl r0 @ │ │ │ │ andseq r0, r1, r1, lsl r0 │ │ │ │ eoreq r0, r6, r6, lsr #32 │ │ │ │ andseq r0, r1, r3, lsr #1 │ │ │ │ andseq r0, r1, r1, lsl r0 │ │ │ │ andseq r0, r1, r1, lsl r0 │ │ │ │ ldrdeq r0, [r0], #13 @ │ │ │ │ andseq r0, r1, r1, lsl r0 │ │ │ │ addseq r0, pc, r1, lsl r0 @ │ │ │ │ @ instruction: 0xf7ff6821 │ │ │ │ strmi pc, [r1], -r3, ror #27 │ │ │ │ - eorsvc pc, ip, ip, asr #12 │ │ │ │ + eorsvc pc, r4, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ stc2 7, cr15, [r6, #1020]! @ 0x3fc │ │ │ │ - rsbvc pc, r0, ip, asr #12 │ │ │ │ + subsvc pc, r8, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ eorvc r2, r3, #0, 6 │ │ │ │ pop {r0, r1, r3, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f84ff0 │ │ │ │ @ instruction: 0xf5c0bf9f │ │ │ │ @ instruction: 0xf04f7684 │ │ │ │ strcc r0, [r1], -r0, lsl #22 │ │ │ │ @@ -15516,52 +15514,52 @@ │ │ │ │ movwne pc, #53824 @ 0xd240 @ │ │ │ │ @ instruction: 0xf0004298 │ │ │ │ vrhadd.s8 q12, q0, │ │ │ │ vorr.i32 d23, #2048 @ 0x00000800 │ │ │ │ ldmdavs r9, {r0, r2, r8, r9} │ │ │ │ tstcc r9, r1, lsl #2 │ │ │ │ @ instruction: 0xf64c685a │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d21, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf0070002 │ │ │ │ - bvc 91ea48 │ │ │ │ - blcs 31d9c <__time64@plt+0x20ab4> │ │ │ │ + bvc 91ea40 │ │ │ │ + blcs 31d94 <__time64@plt+0x20aac> │ │ │ │ teqphi fp, r0 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf5b26862 │ │ │ │ @ instruction: 0xf0007f80 │ │ │ │ ldrbmi r8, [sp], -r3, asr #2 │ │ │ │ svceq 0x0000f1bb │ │ │ │ @ instruction: 0xf649d017 │ │ │ │ - vmov.i16 d19, #1024 @ 0x0400 │ │ │ │ + vmlsl.s8 , d0, d12 │ │ │ │ strls r0, [r2], #-2562 @ 0xfffff5fe │ │ │ │ @ instruction: 0x465c461d │ │ │ │ stmdavs r4!, {r0, r1, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ stmdavs r0!, {r0, r2, r4, r5, r7, pc}^ │ │ │ │ @ instruction: 0xf7f04651 │ │ │ │ - stmdacs r0, {r1, r3, r4, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r3, r4, r8, sl, fp, sp, lr, pc} │ │ │ │ stcls 1, cr13, [r2], {245} @ 0xf5 │ │ │ │ strcs r4, [r1, #-1579] @ 0xfffff9d5 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ stmdavs r0!, {r4, r6, r9, pc}^ │ │ │ │ @ instruction: 0xf000283a │ │ │ │ @ instruction: 0xf1b880ab │ │ │ │ @ instruction: 0xf0400f00 │ │ │ │ - bvc 900984 │ │ │ │ + bvc 90097c │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ stmdavs r0!, {r0, r2, r4, r6, r7, pc}^ │ │ │ │ @ instruction: 0xf000287b │ │ │ │ @ instruction: 0xf1bb80db │ │ │ │ andle r0, r1, r0, lsl #30 │ │ │ │ andlt pc, r0, r9, asr #17 │ │ │ │ @ instruction: 0x46384631 │ │ │ │ pop {r0, r1, r3, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f84ff0 │ │ │ │ stccs 14, cr11, [r0, #-844] @ 0xfffffcb4 │ │ │ │ @ instruction: 0x83bbf000 │ │ │ │ - subvs pc, ip, ip, asr #12 │ │ │ │ + subvs pc, r4, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ stc2 7, cr15, [r4, #-1020]! @ 0xfffffc04 │ │ │ │ eorvc r2, r3, #0, 6 │ │ │ │ andlt r2, fp, r0 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @@ -15573,34 +15571,34 @@ │ │ │ │ eorvc fp, r7, #4, 30 │ │ │ │ @ instruction: 0xf0006826 │ │ │ │ vand q12, q8, q15 │ │ │ │ vorr.i32 d23, #2048 @ 0x00000800 │ │ │ │ ldmdavs r9, {r0, r2, r8, r9} │ │ │ │ tstcc r9, r1, lsl #2 │ │ │ │ @ instruction: 0xf64c685a │ │ │ │ - vaddl.s8 , d0, d16 │ │ │ │ + vmov.i32 d21, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf0070002 │ │ │ │ - bvc 91e964 │ │ │ │ - blcs 31e7c <__time64@plt+0x20b94> │ │ │ │ + bvc 91e95c │ │ │ │ + blcs 31e74 <__time64@plt+0x20b8c> │ │ │ │ mvnhi pc, r0 │ │ │ │ ldmdacs fp!, {r5, r6, fp, sp, lr}^ │ │ │ │ stccs 0, cr13, [r0, #-504] @ 0xfffffe08 │ │ │ │ - bvc 9147a4 │ │ │ │ + bvc 91479c │ │ │ │ rsbsle r2, sp, r0, lsl #22 │ │ │ │ ldmdacs fp!, {r5, r6, fp, sp, lr} │ │ │ │ @ instruction: 0xf64cd146 │ │ │ │ - vmla.i d22, d16, d0[0] │ │ │ │ + vshr.s64 d22, d24, #64 │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ movwcs pc, #3303 @ 0xce7 @ │ │ │ │ strb r7, [r1, r3, lsr #4] │ │ │ │ movwcs r6, #2080 @ 0x820 │ │ │ │ vaba.s8 d30, d0, d31 │ │ │ │ @ instruction: 0xf7ff100d │ │ │ │ - bvc 91fbb4 │ │ │ │ - blcs 31eb8 <__time64@plt+0x20bd0> │ │ │ │ + bvc 91fbac │ │ │ │ + blcs 31eb0 <__time64@plt+0x20bc8> │ │ │ │ bicshi pc, r5, r0 │ │ │ │ ldmdacs ip!, {r5, r6, fp, sp, lr} │ │ │ │ msrhi SPSR_sx, r0 │ │ │ │ vmax.s8 d20, d0, d24 │ │ │ │ vorr.i32 d23, #8 @ 0x00000008 │ │ │ │ andlt r0, fp, r5, lsl #2 │ │ │ │ svcmi 0x00f0e8bd │ │ │ │ @@ -15630,15 +15628,15 @@ │ │ │ │ strb r9, [pc, -r2, lsl #24] │ │ │ │ stmdaeq r2, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ movweq pc, #4229 @ 0x1085 @ │ │ │ │ svceq 0x0000f1b8 │ │ │ │ movwcs fp, #3852 @ 0xf0c │ │ │ │ movweq pc, #4099 @ 0x1003 @ │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ - bvc 90101c │ │ │ │ + bvc 901014 │ │ │ │ stmdavs r0!, {r0, r1, r4, r5, r8, ip, sp, pc}^ │ │ │ │ svclt 0x001c287b │ │ │ │ eorvc r2, r3, #0, 6 │ │ │ │ svcge 0x0041f43f │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0xff10f7fd │ │ │ │ @@ -15660,95 +15658,95 @@ │ │ │ │ rsbvs r2, r0, r1, lsl #6 │ │ │ │ str r7, [r1, -r3, lsr #4]! │ │ │ │ @ instruction: 0xf7ff217d │ │ │ │ str pc, [r0, -sp, lsl #26]! │ │ │ │ @ instruction: 0xf04f6860 │ │ │ │ ldrb r0, [r3], r1, lsl #16 │ │ │ │ movwls r2, #8960 @ 0x2300 │ │ │ │ - blcs 3f040 <__time64@plt+0x2dd58> │ │ │ │ + blcs 3f038 <__time64@plt+0x2dd50> │ │ │ │ mvnhi pc, r0 │ │ │ │ ldmdacs fp!, {r5, r6, fp, sp, lr}^ │ │ │ │ svcge 0x0013f47f │ │ │ │ svceq 0x0002f1b8 │ │ │ │ stccs 0, cr13, [r0, #-60] @ 0xffffffc4 │ │ │ │ cmncs sp, pc, lsr r0 │ │ │ │ @ instruction: 0xf7ff207b │ │ │ │ @ instruction: 0x4638fcf5 │ │ │ │ tstpvc r8, r0, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r5, r0, r2, pc @ │ │ │ │ pop {r0, r1, r3, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f94ff0 │ │ │ │ @ instruction: 0xf64cbeaf │ │ │ │ - vmla.i d21, d0, d0[6] │ │ │ │ + vmla.i d21, d0, d0[4] │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ @ instruction: 0xe7e8fc33 │ │ │ │ movwcs r6, #2087 @ 0x827 │ │ │ │ vhsub.s8 d23, d0, d19 │ │ │ │ vaddl.s8 , d0, d20 │ │ │ │ @ instruction: 0xf7fd0005 │ │ │ │ movwcs pc, #7865 @ 0x1eb9 @ │ │ │ │ svcvc 0x0080f5b0 │ │ │ │ eorvc r6, r3, #96 @ 0x60 │ │ │ │ mrcge 4, 5, APSR_nzcv, cr13, cr15, {3} │ │ │ │ - blx fe5dc81a │ │ │ │ + blx fe5dc812 │ │ │ │ stmdaeq r2, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ strmi r7, [r3], r3, lsr #20 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ - blcs 4c308 <__time64@plt+0x3b020> │ │ │ │ + blcs 4c300 <__time64@plt+0x3b018> │ │ │ │ addshi pc, r5, #0 │ │ │ │ - blcs eba9bc │ │ │ │ + blcs eba9b4 │ │ │ │ @ instruction: 0x81b9f000 │ │ │ │ @ instruction: 0xf47f2b7b │ │ │ │ @ instruction: 0xf64caedb │ │ │ │ - vmla.i d21, d0, d0[6] │ │ │ │ + vmla.i d21, d0, d0[4] │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ @ instruction: 0xf8cdfc09 │ │ │ │ movwcs fp, #8 │ │ │ │ stmdaeq r1, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ eorvc r4, r3, #161480704 @ 0x9a00000 │ │ │ │ strlt lr, [r3], -sp, asr #19 │ │ │ │ - blcs 46470 <__time64@plt+0x35188> │ │ │ │ + blcs 46468 <__time64@plt+0x35180> │ │ │ │ stmdavs r0!, {r1, r2, r3, r4, r6, ip, lr, pc}^ │ │ │ │ rsbsle r2, r4, sp, ror r8 │ │ │ │ rsbsle r2, r2, r0, lsl #16 │ │ │ │ stmdage r7, {r0, r8, sp} │ │ │ │ mcr2 7, 0, pc, cr0, cr15, {7} @ │ │ │ │ stmdacs r0, {r0, r1, r7, r9, sl, lr} │ │ │ │ subhi pc, r0, #64 @ 0x40 │ │ │ │ cdpvc 2, 2, cr15, cr4, cr0, {2} │ │ │ │ cdpeq 2, 0, cr15, cr5, cr0, {6} │ │ │ │ - stmibpl r8!, {r2, r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmibpl r0!, {r2, r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdbeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - ldrpl pc, [r0], ip, asr #12 │ │ │ │ + strpl pc, [r8], ip, asr #12 │ │ │ │ streq pc, [r2], -r0, asr #5 │ │ │ │ eor r4, r1, r5, ror r6 │ │ │ │ vadd.i8 q11, q0, q9 │ │ │ │ addsmi r1, sl, #1140850688 @ 0x44000000 │ │ │ │ @ instruction: 0xf8d4d129 │ │ │ │ strbmi fp, [r9], -r0 │ │ │ │ eorvc r2, r7, #0, 14 │ │ │ │ @ instruction: 0xf7f04658 │ │ │ │ - @ instruction: 0xb160eb9e │ │ │ │ + cmnlt r0, r2, lsr #23 │ │ │ │ @ instruction: 0x46584631 │ │ │ │ - bl fe65e878 │ │ │ │ + bl fe75e870 │ │ │ │ @ instruction: 0xf64cb138 │ │ │ │ - vsra.s64 d21, d12, #64 │ │ │ │ + vsra.s64 d21, d4, #64 │ │ │ │ ldrbmi r0, [r8], -r2, lsl #2 │ │ │ │ - bl fe45e888 │ │ │ │ + bl fe55e880 │ │ │ │ smlatbcs r1, r0, r9, fp │ │ │ │ @ instruction: 0xf7ffa807 │ │ │ │ stmdacs r0, {r0, r1, r2, r3, r6, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ sbcshi pc, sp, r0, asr #32 │ │ │ │ - blcs 3f168 <__time64@plt+0x2de80> │ │ │ │ + blcs 3f160 <__time64@plt+0x2de78> │ │ │ │ @ instruction: 0x4628d1da │ │ │ │ mcr2 7, 2, pc, cr10, cr13, {7} @ │ │ │ │ tstpne r1, #64, 4 @ p-variant is OBSOLETE │ │ │ │ andhi pc, r8, r4, lsl #17 │ │ │ │ mlsvs r0, r8, r2, r4 │ │ │ │ - bvc a14c48 │ │ │ │ + bvc a14c40 │ │ │ │ stmdavs r0!, {r0, r1, r2, r3, r8, r9, ip, sp, pc}^ │ │ │ │ andle r2, sp, fp, lsr r8 │ │ │ │ tstphi fp, r0, asr #6 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf000287b │ │ │ │ veor d8, d16, d2 │ │ │ │ ldmdacs fp, {r0, r2, r4, r7, r8, pc}^ │ │ │ │ cmpcs sp, r0, lsl r1 │ │ │ │ @@ -15768,53 +15766,53 @@ │ │ │ │ @ instruction: 0xf884fe19 │ │ │ │ rsbvs r8, r0, r8 │ │ │ │ ldmib sp, {r2, r4, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ ldrbmi fp, [r0], -r3, lsl #12 │ │ │ │ @ instruction: 0xf7f89f05 │ │ │ │ @ instruction: 0x4604fe17 │ │ │ │ @ instruction: 0xf7ff207d │ │ │ │ - bls df8f0 │ │ │ │ + bls df8e8 │ │ │ │ andlt lr, r0, #3358720 @ 0x334000 │ │ │ │ ldrtmi r4, [r1], -r3, lsr #12 │ │ │ │ vmin.s8 d20, d0, d24 │ │ │ │ vmov.i32 d23, #2048 @ 0x00000800 │ │ │ │ @ instruction: 0xf7f80205 │ │ │ │ strb pc, [ip], -r5, lsl #24 @ │ │ │ │ - blx ff55e97e │ │ │ │ + blx ff55e976 │ │ │ │ andcs r4, r0, #40, 12 @ 0x2800000 │ │ │ │ - orrmi pc, r8, ip, asr #12 │ │ │ │ + orrmi pc, r0, ip, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ strvc pc, [r4, -r0, asr #4]! │ │ │ │ streq pc, [r5, -r0, asr #5] │ │ │ │ - bmi fe55e2c8 │ │ │ │ - beq dd49c │ │ │ │ - stmibmi ip, {r2, r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ + bmi fe35e2c0 │ │ │ │ + beq dd494 │ │ │ │ + stmibmi r4, {r2, r3, r6, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdbeq r2, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - blx 4de982 │ │ │ │ - bleq 5cae8 │ │ │ │ + blx 5de97a │ │ │ │ + bleq 5cae0 │ │ │ │ @ instruction: 0xf04f4605 │ │ │ │ - bvc 8e29b8 │ │ │ │ + bvc 8e29b0 │ │ │ │ stmdavs r6!, {r0, r1, r3, r4, r7, r8, ip, sp, pc}^ │ │ │ │ svcvc 0x0083f5b6 │ │ │ │ vqadd.s8 d29, d0, d7 │ │ │ │ addsmi r1, lr, #738197504 @ 0x2c000000 │ │ │ │ cdpcs 0, 3, cr13, cr10, cr1, {0} │ │ │ │ @ instruction: 0x4628d119 │ │ │ │ stmdavs r1!, {r9, sp} │ │ │ │ @ instruction: 0xf7f67222 │ │ │ │ - bvc 91f5c4 │ │ │ │ - blcs 321f0 <__time64@plt+0x20f08> │ │ │ │ + bvc 91f5cc │ │ │ │ + blcs 321e8 <__time64@plt+0x20f00> │ │ │ │ ldrtmi sp, [r8], -fp, ror #3 │ │ │ │ stc2l 7, cr15, [sl, #1012] @ 0x3f4 │ │ │ │ @ instruction: 0xf5b64606 │ │ │ │ rsbvs r7, r0, r3, lsl #31 │ │ │ │ strtmi sp, [r8], -r7, ror #3 │ │ │ │ strbmi r2, [r9], -r0, lsl #4 │ │ │ │ @ instruction: 0xf7f67222 │ │ │ │ - strmi pc, [r5], -r9, ror #21 │ │ │ │ + strmi pc, [r5], -sp, ror #21 │ │ │ │ mcrcs 7, 1, lr, cr11, cr9, {6} │ │ │ │ cdpcs 0, 3, cr13, cr12, cr3, {7} │ │ │ │ sbchi pc, r2, r0 │ │ │ │ eorsle r2, r6, lr, lsr lr │ │ │ │ orrvc pc, r6, #696254464 @ 0x29800000 │ │ │ │ stmdavs r2!, {r8, sp} │ │ │ │ eorvc r2, r1, #1024 @ 0x400 │ │ │ │ @@ -15822,15 +15820,15 @@ │ │ │ │ msreq CPSR_fx, #-2147483607 @ 0x80000029 │ │ │ │ movweq pc, #8243 @ 0x2033 @ │ │ │ │ tstphi r9, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ @ instruction: 0x469b813f │ │ │ │ @ instruction: 0x46284611 │ │ │ │ @ instruction: 0xf7f62200 │ │ │ │ - strmi pc, [r5], -r9, asr #21 │ │ │ │ + strmi pc, [r5], -sp, asr #21 │ │ │ │ vaba.s8 d30, d16, d25 │ │ │ │ vaddl.s8 , d0, d20 │ │ │ │ @ instruction: 0xf7fd0005 │ │ │ │ movwcs pc, #7575 @ 0x1d97 @ │ │ │ │ eorvc r6, r3, #96 @ 0x60 │ │ │ │ vmax.s8 d30, d0, d11 │ │ │ │ vaddl.s8 , d0, d20 │ │ │ │ @@ -15841,19 +15839,19 @@ │ │ │ │ vaddl.s8 , d0, d20 │ │ │ │ @ instruction: 0xf7fd0005 │ │ │ │ movwcs pc, #7555 @ 0x1d83 @ │ │ │ │ eorvc r6, r3, #96 @ 0x60 │ │ │ │ strtmi lr, [r8], -r6, lsr #11 │ │ │ │ ldrbmi r2, [r1], -r0, lsl #4 │ │ │ │ @ instruction: 0xf7f67222 │ │ │ │ - @ instruction: 0xf1b8faa3 │ │ │ │ + @ instruction: 0xf1b8faa7 │ │ │ │ strmi r0, [r5], -r1, lsl #16 │ │ │ │ mrcge 4, 0, APSR_nzcv, cr0, cr15, {1} │ │ │ │ - bvc 91a8d0 │ │ │ │ - blcs 324a4 <__time64@plt+0x211bc> │ │ │ │ + bvc 91a8c8 │ │ │ │ + blcs 3249c <__time64@plt+0x211b4> │ │ │ │ stmdavs r0!, {r2, r5, r6, ip, lr, pc}^ │ │ │ │ svclt 0x001c283a │ │ │ │ strcs r2, [r0, #-769] @ 0xfffffcff │ │ │ │ vqadd.s8 , q0, │ │ │ │ vabdl.s8 , d0, d20 │ │ │ │ ldrbmi r0, [lr], -r5, lsl #14 │ │ │ │ strpl lr, [r8, #-2509] @ 0xfffff633 │ │ │ │ @@ -15865,289 +15863,289 @@ │ │ │ │ mvnsle r2, r0, lsl #22 │ │ │ │ @ instruction: 0xf7fd4638 │ │ │ │ @ instruction: 0xf884fd53 │ │ │ │ stmdacs sl!, {r3, pc} │ │ │ │ rscle r6, pc, r0, rrx │ │ │ │ movwcs r4, #5680 @ 0x1630 │ │ │ │ stmdbge r9, {r3, r9, fp, sp, pc} │ │ │ │ - blx 1d5cae8 │ │ │ │ + blx 1d5cae0 │ │ │ │ @ instruction: 0xf7ff4606 │ │ │ │ strmi pc, [r7], -r5, asr #23 │ │ │ │ ldmib sp, {r1, r2, r3, r6, r7, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf1b99307 │ │ │ │ andle r0, r9, r0, lsl #30 │ │ │ │ stmdbls r9, {r0, r1, r3, r4, r5, r7, r8, ip, sp, pc} │ │ │ │ - andvs pc, r8, ip, asr #12 │ │ │ │ + andvs pc, r0, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx fe9deb08 │ │ │ │ + blx fe9deb00 │ │ │ │ cmnlt r3, r8, lsl #22 │ │ │ │ @ instruction: 0x46504631 │ │ │ │ vpmax.s8 d25, d0, d9 │ │ │ │ vmov.i32 d23, #134217728 @ 0x08000000 │ │ │ │ strls r0, [r0], -r5, lsl #12 │ │ │ │ ldc2l 7, cr15, [r6], {249} @ 0xf9 │ │ │ │ - bvc 8f2530 │ │ │ │ + bvc 8f2528 │ │ │ │ @ instruction: 0xd1bc2f00 │ │ │ │ @ instruction: 0x464be695 │ │ │ │ eorls pc, r0, sp, asr #17 │ │ │ │ stmdacs r8!, {r2, r3, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ addhi pc, fp, r0 │ │ │ │ rsbsle r2, ip, r9, lsr #16 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf64caef8 │ │ │ │ - vshr.s64 , q4, #64 │ │ │ │ + vshr.s64 , q0, #64 │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ - bvc 91f560 │ │ │ │ + bvc 91f558 │ │ │ │ strcs lr, [r1, -r1, lsl #13] │ │ │ │ - bcs 5a68c │ │ │ │ + bcs 5a684 │ │ │ │ adcshi pc, r2, r0 │ │ │ │ strb r4, [r5, -fp, lsl #13]! │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ stc2 7, cr15, [r4, #-1012] @ 0xfffffc0c │ │ │ │ andhi pc, r8, r4, lsl #17 │ │ │ │ ldr r6, [r1, r0, rrx] │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ ldc2l 7, cr15, [sl], #1012 @ 0x3f4 │ │ │ │ rsbvs r2, r0, r1, lsl #6 │ │ │ │ ldr r7, [r6], -r3, lsr #4 │ │ │ │ andcs r4, r0, #40, 12 @ 0x2800000 │ │ │ │ - orrmi pc, r8, ip, asr #12 │ │ │ │ + orrmi pc, r0, ip, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf1087222 │ │ │ │ @ instruction: 0xf7f60801 │ │ │ │ - @ instruction: 0x4605fa15 │ │ │ │ + @ instruction: 0x4605fa19 │ │ │ │ @ instruction: 0xf04fe705 │ │ │ │ vadd.i8 d16, d0, d2 │ │ │ │ movwcs r1, #13 │ │ │ │ @ instruction: 0xf7ff7223 │ │ │ │ @ instruction: 0xf64cfab9 │ │ │ │ - vbic.i32 d21, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 , q0, d24 │ │ │ │ strmi r0, [r5], -r2, lsl #2 │ │ │ │ - b 4deb84 │ │ │ │ + b 5deb7c │ │ │ │ @ instruction: 0xf64cb178 │ │ │ │ - vbic.i32 d21, #8 @ 0x00000008 │ │ │ │ + vbic.i32 d21, #0 @ 0x00000000 │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - b 2deb94 │ │ │ │ + b 3deb8c │ │ │ │ @ instruction: 0xf64cb138 │ │ │ │ - vmla.f d21, d0, d0[1] │ │ │ │ + vbic.i32 d21, #12 @ 0x0000000c │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - b deba4 │ │ │ │ + b 1deb9c │ │ │ │ vmla.i8 d27, d0, d16 │ │ │ │ @ instruction: 0xf7ff100d │ │ │ │ @ instruction: 0x4605fa9d │ │ │ │ strtmi r2, [r8], -r4, lsl #2 │ │ │ │ - blx ff5debda │ │ │ │ + blx ff5debd2 │ │ │ │ stmdacs r0, {r1, ip, pc} │ │ │ │ - bvc 914df8 │ │ │ │ + bvc 914df0 │ │ │ │ rsble r2, r4, r0, lsl #22 │ │ │ │ ldrdge pc, [r4], -r4 │ │ │ │ svceq 0x007bf1ba │ │ │ │ - bvc 995208 │ │ │ │ + bvc 995200 │ │ │ │ adcsle r2, r1, r0, lsl #26 │ │ │ │ svceq 0x0002f1b8 │ │ │ │ mrcge 4, 0, APSR_nzcv, cr7, cr15, {3} │ │ │ │ - rsbpl pc, r8, ip, asr #12 │ │ │ │ + rsbpl pc, r0, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx 65ec24 │ │ │ │ + blx 65ec1c │ │ │ │ cmncs sp, pc, lsl #12 │ │ │ │ - blx ff1dec2c │ │ │ │ + blx ff1dec24 │ │ │ │ ldr r7, [r2], -r3, lsr #20 │ │ │ │ @ instruction: 0xf47f287d │ │ │ │ - bvc 90c634 │ │ │ │ + bvc 90c62c │ │ │ │ subsle r2, r1, r0, lsl #22 │ │ │ │ @ instruction: 0xf64c4601 │ │ │ │ - vshr.s64 d21, d16, #64 │ │ │ │ + vaddl.s8 , d16, d24 │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ - bvc 91f464 │ │ │ │ + bvc 91f45c │ │ │ │ @ instruction: 0x2129e603 │ │ │ │ - blx fecdec54 │ │ │ │ + blx fecdec4c │ │ │ │ @ instruction: 0x212ae64b │ │ │ │ - andmi pc, r4, ip, asr #12 │ │ │ │ + rscscc pc, ip, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf0069203 │ │ │ │ msrcs CPSR_fs, fp @ │ │ │ │ @ instruction: 0xf64c9002 │ │ │ │ - vaddl.s8 q10, d0, d4 │ │ │ │ + vshr.s64 , q14, #64 │ │ │ │ @ instruction: 0xf0060002 │ │ │ │ - bls 120348 │ │ │ │ + bls 120340 │ │ │ │ ldrtmi r4, [r0], -r4, lsl #13 │ │ │ │ @ instruction: 0x46664611 │ │ │ │ - blx 7dec84 │ │ │ │ + blx 7dec7c │ │ │ │ stmib sp, {r1, r8, r9, fp, ip, pc}^ │ │ │ │ @ instruction: 0xf64c6000 │ │ │ │ - vrshr.s64 d20, d8, #64 │ │ │ │ + vrshr.s64 d20, d0, #64 │ │ │ │ @ instruction: 0xf64c0202 │ │ │ │ - vaddw.s8 q10, q8, d24 │ │ │ │ + vaddw.s8 q10, q8, d16 │ │ │ │ @ instruction: 0xf64c0102 │ │ │ │ - vshr.s64 d20, d24, #64 │ │ │ │ + vshr.s64 d20, d16, #64 │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ stmdavs r6!, {r0, r1, r2, r4, r6, r7, r8, fp, ip, sp, lr, pc}^ │ │ │ │ tstle r9, sl, lsr #28 │ │ │ │ svceq 0x0000f1bb │ │ │ │ vrhadd.s8 , , q1 │ │ │ │ - vmlal.s q10, d0, d0[7] │ │ │ │ + vmlal.s q10, d0, d0[5] │ │ │ │ @ instruction: 0xf04f0202 │ │ │ │ ldrt r0, [r5], r1, lsl #22 │ │ │ │ - addmi pc, r4, #76, 12 @ 0x4c00000 │ │ │ │ + rsbsmi pc, ip, #76, 12 @ 0x4c00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ vmin.s8 d30, d16, d16 │ │ │ │ vaddl.s8 , d0, d20 │ │ │ │ @ instruction: 0xf7fd0005 │ │ │ │ movwcs pc, #7247 @ 0x1c4f @ │ │ │ │ rsbvs r4, r0, r2, lsl #13 │ │ │ │ ldr r7, [r1, r3, lsr #4] │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ mcrr2 7, 15, pc, r4, cr13 @ │ │ │ │ rsbvs r2, r0, r1, lsl #6 │ │ │ │ str r7, [r3, r3, lsr #4]! │ │ │ │ strb r7, [ip], r3, lsr #20 │ │ │ │ @ instruction: 0xf64c4629 │ │ │ │ - vmla.i d21, d0, d0[3] │ │ │ │ + vmla.i d21, d0, d0[1] │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ ldrb pc, [r8, -r7, lsr #19]! @ │ │ │ │ cmncs fp, r5, lsr #16 │ │ │ │ - andmi pc, r4, ip, asr #12 │ │ │ │ + rscscc pc, ip, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ stc2l 0, cr15, [r2, #-24]! @ 0xffffffe8 │ │ │ │ strtmi r4, [r9], -r3, lsl #12 │ │ │ │ @ instruction: 0x461d4650 │ │ │ │ @ instruction: 0xf9cef7ff │ │ │ │ strmi r4, [r2], -r9, lsr #12 │ │ │ │ - addcc pc, r8, ip, asr #12 │ │ │ │ + addcc pc, r0, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ff2500 │ │ │ │ ldr pc, [r9, #-2447]! @ 0xfffff671 │ │ │ │ - sbcsmi pc, ip, ip, asr #12 │ │ │ │ + sbcsmi pc, r4, ip, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf988f7ff │ │ │ │ - bleq 9d178 │ │ │ │ - rsbmi pc, ip, #-1879048188 @ 0x90000004 │ │ │ │ + bleq 9d170 │ │ │ │ + rsbmi pc, r4, #-1879048188 @ 0x90000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ vmax.s8 q15, q0, q14 │ │ │ │ vaddl.s8 , d0, d20 │ │ │ │ @ instruction: 0xf7fd0005 │ │ │ │ ldrbmi pc, [sp], -fp, lsl #24 @ │ │ │ │ ldmdacs sl!, {r0, r9, sp} │ │ │ │ eorvc r6, r2, #96 @ 0x60 │ │ │ │ ldclge 4, cr15, [r8], {63} @ 0x3f │ │ │ │ stmdaeq r2, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ andlt pc, r8, sp, asr #17 │ │ │ │ vqrshl.s8 d30, d10, d9 │ │ │ │ - vsubl.s8 q11, d16, d28 │ │ │ │ + vsubl.s8 q11, d16, d20 │ │ │ │ @ instruction: 0xf64c0202 │ │ │ │ - vaddl.s8 q11, d0, d28 │ │ │ │ + vaddl.s8 q11, d0, d20 │ │ │ │ vst4.8 {d16-d19}, [pc], r2 │ │ │ │ @ instruction: 0xf7f0717f │ │ │ │ - svclt 0x0000fb9b │ │ │ │ + svclt 0x0000fb9f │ │ │ │ vqrshl.s8 d27, d16, d0 │ │ │ │ vabal.s8 , d0, d20 │ │ │ │ addlt r0, r3, r5, lsl #10 │ │ │ │ stmdage r1, {r0, r8, sp} │ │ │ │ - blx 195eda6 │ │ │ │ + blx 195ed9e │ │ │ │ strmi r7, [r4], -fp, lsr #20 │ │ │ │ stmdavs fp!, {r0, r1, r6, r8, ip, sp, pc}^ │ │ │ │ tstle r0, sl, lsr #22 │ │ │ │ @ instruction: 0xf7f84620 │ │ │ │ strmi pc, [r4], -pc, ror #22 │ │ │ │ eorvc r2, fp, #0, 6 │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ - blx ff5dedc2 │ │ │ │ + blx ff5dedba │ │ │ │ stmdacs sl!, {r0, r8, r9, sp} │ │ │ │ eorvc r6, fp, #104 @ 0x68 │ │ │ │ - blls 95190 │ │ │ │ + blls 95188 │ │ │ │ @ instruction: 0xf64cb12b │ │ │ │ - vmvn.i32 , #0 @ 0x00000000 │ │ │ │ + vmla.i d23, d0, d0[6] │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ tstpcs r0, r9, lsr r9 @ p-variant is OBSOLETE │ │ │ │ andlt r4, r3, r0, lsr #12 │ │ │ │ ldrhtmi lr, [r0], -sp │ │ │ │ - bllt ff5dedd4 │ │ │ │ + bllt ff5dedcc │ │ │ │ vqrshl.s8 , q8, q8 │ │ │ │ vaddhn.i16 d23, q0, q10 │ │ │ │ addlt r0, r3, r5, lsl #8 │ │ │ │ - bvc 8f2618 │ │ │ │ + bvc 8f2610 │ │ │ │ rsbsle r2, r9, r0, lsl #22 │ │ │ │ @ instruction: 0xf5a06860 │ │ │ │ - blcs 17dc20 │ │ │ │ + blcs 17dc18 │ │ │ │ ldm pc, {r0, r1, r5, r6, fp, ip, lr, pc}^ @ │ │ │ │ mcrrcs 0, 0, pc, ip, cr3 @ │ │ │ │ cmneq r2, #28, 4 @ 0xc0000001 │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ strcs r6, [r0], -r7, lsr #16 │ │ │ │ @ instruction: 0xf7fd7226 │ │ │ │ stmdacs r8!, {r0, r2, r5, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ rsbsle r6, sp, r0, rrx │ │ │ │ - sbcmi pc, r4, #-1610612732 @ 0xa0000004 │ │ │ │ + adcsmi pc, ip, #-1610612732 @ 0xa0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ eorvc r2, r3, #67108864 @ 0x4000000 │ │ │ │ @ instruction: 0x46284639 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f840f0 │ │ │ │ vpadd.i8 , q5, │ │ │ │ - vmlal.s q10, d16, d0[1] │ │ │ │ + vrshr.s64 d20, d28, #64 │ │ │ │ @ instruction: 0xf6490202 │ │ │ │ - vorr.i32 d19, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 , q0, d12 │ │ │ │ movwcs r0, #258 @ 0x102 │ │ │ │ eorvc r4, r3, #40, 12 @ 0x2800000 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f840f0 │ │ │ │ eorcs fp, r8, r3, asr #22 │ │ │ │ eorvc r2, r3, #0, 6 │ │ │ │ @ instruction: 0xf958f7ff │ │ │ │ @ instruction: 0xff8cf7ff │ │ │ │ eorcs r4, ip, r4, lsl #12 │ │ │ │ @ instruction: 0xf952f7ff │ │ │ │ - blx febdee84 │ │ │ │ + blx febdee7c │ │ │ │ eorcs r4, ip, r6, lsl #12 │ │ │ │ @ instruction: 0xf94cf7ff │ │ │ │ - blx fea5ee90 │ │ │ │ + blx fea5ee88 │ │ │ │ eorcs r4, r9, r7, lsl #12 │ │ │ │ @ instruction: 0xf946f7ff │ │ │ │ @ instruction: 0x4632463b │ │ │ │ strtmi r4, [r8], -r1, lsr #12 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f940f0 │ │ │ │ eorcs fp, r8, fp, lsr #22 │ │ │ │ eorvc r2, r3, #0, 6 │ │ │ │ @ instruction: 0xf938f7ff │ │ │ │ @ instruction: 0xff6cf7ff │ │ │ │ eorcs r4, r9, r4, lsl #12 │ │ │ │ @ instruction: 0xf932f7ff │ │ │ │ strtmi r4, [r8], -r2, lsr #12 │ │ │ │ - orrvc pc, ip, r8, asr #12 │ │ │ │ + orrvc pc, r4, r8, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f840f0 │ │ │ │ stmdavs r1!, {r0, r1, r3, r4, r8, r9, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf8f2f7ff │ │ │ │ @ instruction: 0xf64c4601 │ │ │ │ - vshr.s64 d23, d4, #64 │ │ │ │ + vaddl.s8 , d16, d12 │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ vtst.8 d31, d26, d21 │ │ │ │ - vmlal.s q10, d16, d0[1] │ │ │ │ + vrshr.s64 d20, d28, #64 │ │ │ │ movwcs r0, #514 @ 0x202 │ │ │ │ @ instruction: 0xe7b14611 │ │ │ │ @ instruction: 0xf7fd4620 │ │ │ │ @ instruction: 0xf5a0fb3b │ │ │ │ andcs r7, r1, #132, 6 @ 0x10000002 │ │ │ │ eorvc r6, r2, #96 @ 0x60 │ │ │ │ stmiale r4!, {r0, r2, r8, r9, fp, sp}^ │ │ │ │ @ instruction: 0xf852a201 │ │ │ │ svclt 0x0000f023 │ │ │ │ - andeq r0, r2, fp, lsr #29 │ │ │ │ - andeq r0, r2, fp, ror #28 │ │ │ │ - andeq r0, r2, fp, asr #28 │ │ │ │ - ldrdeq r0, [r2], -r7 │ │ │ │ - ldrdeq r0, [r2], -r7 │ │ │ │ - andeq r0, r2, r9, lsl lr │ │ │ │ + andeq r0, r2, r3, lsr #29 │ │ │ │ + andeq r0, r2, r3, ror #28 │ │ │ │ + andeq r0, r2, r3, asr #28 │ │ │ │ + andeq r0, r2, pc, asr #29 │ │ │ │ + andeq r0, r2, pc, asr #29 │ │ │ │ + andeq r0, r2, r1, lsl lr │ │ │ │ @ instruction: 0xf7ff7226 │ │ │ │ @ instruction: 0x4602fa57 │ │ │ │ andls r2, r1, #41 @ 0x29 │ │ │ │ @ instruction: 0xf8f4f7ff │ │ │ │ ldrb r9, [sp, -r1, lsl #20]! │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ addvc pc, r0, pc, asr #8 │ │ │ │ @@ -16166,26 +16164,26 @@ │ │ │ │ @ instruction: 0xff3af7ff │ │ │ │ stmdaeq r1, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ strcs r4, [r0], -r5, lsl #12 │ │ │ │ stmdavs r3!, {r0, r1, r2, sp, lr, pc}^ │ │ │ │ tstle pc, ip, lsr #22 │ │ │ │ eorvc r4, r6, #40, 12 @ 0x2800000 │ │ │ │ @ instruction: 0xff2ef7ff │ │ │ │ - bvc 8f27b0 │ │ │ │ + bvc 8f27a8 │ │ │ │ mvnsle r2, r0, lsl #22 │ │ │ │ @ instruction: 0xf7fd4638 │ │ │ │ @ instruction: 0xf884fae9 │ │ │ │ stmdacs ip!, {r3, pc} │ │ │ │ rscle r6, pc, r0, rrx │ │ │ │ @ instruction: 0xf7ff2029 │ │ │ │ strhtcs pc, [r9], -r9 @ │ │ │ │ @ instruction: 0xf8b6f7ff │ │ │ │ pop {r3, r5, r9, sl, lr} │ │ │ │ @ instruction: 0x462081f0 │ │ │ │ - blx ff65efbc │ │ │ │ + blx ff65efb4 │ │ │ │ rsbvs r2, r0, r1, lsl #6 │ │ │ │ strb r7, [ip, r3, lsr #4] │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ strtvc pc, [r4], #-576 @ 0xfffffdc0 │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ strmi r4, [r5], -lr, lsl #12 │ │ │ │ @ instruction: 0x461f4690 │ │ │ │ @@ -16199,33 +16197,33 @@ │ │ │ │ tstle sl, r0, lsl #31 │ │ │ │ @ instruction: 0xff9ef7ff │ │ │ │ andeq pc, r0, r8, asr #17 │ │ │ │ andne pc, sp, r0, asr #4 │ │ │ │ @ instruction: 0xf88af7ff │ │ │ │ eorsvs r7, r0, r3, lsr #20 │ │ │ │ rsble r2, r7, r0, lsl #22 │ │ │ │ - blcs a3b1ac │ │ │ │ + blcs a3b1a4 │ │ │ │ strtmi sp, [r8], -r8 │ │ │ │ mvnsmi lr, #12386304 @ 0xbd0000 │ │ │ │ stmiblt sl!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ tstpne r1, #64, 4 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xd1024298 │ │ │ │ ldmfd sp!, {sp} │ │ │ │ stmdavs r1!, {r3, r4, r5, r6, r7, r8, r9, pc} │ │ │ │ @ instruction: 0xf842f7ff │ │ │ │ @ instruction: 0xf64c4601 │ │ │ │ - vshr.s64 d23, d24, #64 │ │ │ │ + vshr.s64 d23, d16, #64 │ │ │ │ @ instruction: 0xf7ff0002 │ │ │ │ - bvc 91f064 │ │ │ │ + bvc 91f05c │ │ │ │ stmdavs r3!, {r0, r1, r3, r7, r8, r9, ip, sp, pc}^ │ │ │ │ rscle r2, sp, sp, ror fp │ │ │ │ andcs r2, r0, r0, lsl #6 │ │ │ │ pop {r0, r1, r5, r9, ip, sp, lr} │ │ │ │ @ instruction: 0x462083f8 │ │ │ │ - blx fe25f05c │ │ │ │ + blx fe25f054 │ │ │ │ rsbvs r2, r0, r1, lsl #6 │ │ │ │ vhsub.s8 d23, d0, d19 │ │ │ │ addsmi r1, r8, #872415232 @ 0x34000000 │ │ │ │ @ instruction: 0xe7c9d1be │ │ │ │ stmdbeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ andls pc, r8, r4, lsl #17 │ │ │ │ vand , q0, │ │ │ │ @@ -16248,32 +16246,32 @@ │ │ │ │ rsbvs r2, r0, sp, ror r8 │ │ │ │ bicle r7, r5, r3, lsr #4 │ │ │ │ stmdacs r9!, {r1, r4, r5, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ vhadd.s8 , q8, q1 │ │ │ │ vabal.s8 , d0, d20 │ │ │ │ strtmi r0, [r8], -r5, lsl #10 │ │ │ │ andls pc, r8, r4, lsl #17 │ │ │ │ - blx 12df0d8 │ │ │ │ + blx 12df0d0 │ │ │ │ rsbvs r2, r0, r9, lsr #16 │ │ │ │ @ instruction: 0xe7b5d1f7 │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ - blx 105f0ec │ │ │ │ + blx 105f0e4 │ │ │ │ stmdacs r8!, {r0, r8, r9, sp} │ │ │ │ eorvc r6, r3, #96 @ 0x60 │ │ │ │ @ instruction: 0x4628d098 │ │ │ │ mvnsmi lr, #12386304 @ 0xbd0000 │ │ │ │ ldmdblt sl!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ strtvc pc, [r4], #-576 @ 0xfffffdc0 │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ @ instruction: 0x46054698 │ │ │ │ ldrmi r4, [r7], -lr, lsl #12 │ │ │ │ cmplt fp, r3, lsr #20 │ │ │ │ - blcs abb2b4 │ │ │ │ + blcs abb2ac │ │ │ │ strbmi sp, [r3], -lr │ │ │ │ @ instruction: 0x4631463a │ │ │ │ pop {r3, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xe74b41f0 │ │ │ │ @ instruction: 0xf7fd4620 │ │ │ │ movwcs pc, #6685 @ 0x1a1d @ │ │ │ │ rsbvs r2, r0, sl, lsr #16 │ │ │ │ @@ -16287,92 +16285,92 @@ │ │ │ │ ldmiblt sl, {r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ @ instruction: 0x4604b538 │ │ │ │ @ instruction: 0x460db158 │ │ │ │ stmdavs r4!, {r0, sp, lr, pc} │ │ │ │ stmdavs r0!, {r2, r3, r4, r5, r8, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7ef4629 │ │ │ │ - stmdacs r0, {r1, r2, r4, r5, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r3, r4, r5, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ strdcs sp, [r1], -r7 │ │ │ │ @ instruction: 0x4620bd38 │ │ │ │ svclt 0x0000bd38 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ strvc pc, [r4, #-576]! @ 0xfffffdc0 │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ vhadd.s8 d27, d29, d7 │ │ │ │ - vmvn.i16 d16, #1024 @ 0x0400 │ │ │ │ + vmlsl.s8 q8, d0, d28 │ │ │ │ @ instruction: 0xf7fe0a02 │ │ │ │ - bvc ae0e7c │ │ │ │ - bcs 2adb0 <__time64@plt+0x19ac8> │ │ │ │ + bvc ae0e74 │ │ │ │ + bcs 2ada8 <__time64@plt+0x19ac0> │ │ │ │ stmdavs r8!, {r0, r1, r2, r3, r4, r6, ip, lr, pc}^ │ │ │ │ svcvc 0x0082f5b0 │ │ │ │ @ instruction: 0xf5b0da67 │ │ │ │ @ instruction: 0xf2807f81 │ │ │ │ stmdacs r0, {r1, r2, r7, pc} │ │ │ │ vqadd.s8 , q0, q14 │ │ │ │ addsmi r1, r8, #67108864 @ 0x4000000 │ │ │ │ tstcs r0, lr, ror #2 │ │ │ │ eorvc sl, r9, #327680 @ 0x50000 │ │ │ │ @ instruction: 0xf94ef7ff │ │ │ │ stmdacs r0, {r0, r7, r9, sl, lr} │ │ │ │ - blls 1952e0 │ │ │ │ + blls 1952d8 │ │ │ │ vrhadd.s8 d27, d13, d27 │ │ │ │ - vmvn.i32 d16, #4 @ 0x00000004 │ │ │ │ + vaddl.s8 q8, d0, d28 │ │ │ │ @ instruction: 0xf7fe0002 │ │ │ │ vrecps.f32 d31, d0, d23 │ │ │ │ vmlal.s8 , d0, d20 │ │ │ │ strcs r0, [r0], -r5, lsl #16 │ │ │ │ tstpvc r8, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ strbmi r9, [ip], -r1, lsl #6 │ │ │ │ strvs lr, [r4], -sp, asr #19 │ │ │ │ stmdavs fp!, {r0, r1, r2, sp, lr, pc}^ │ │ │ │ tstle lr, sl, lsr #22 │ │ │ │ eorvc r4, lr, #32, 12 @ 0x2000000 │ │ │ │ @ instruction: 0xf942f7f8 │ │ │ │ - bvc af2a28 │ │ │ │ + bvc af2a20 │ │ │ │ mvnsle r2, r0, lsl #22 │ │ │ │ @ instruction: 0xf7fd4640 │ │ │ │ eorvc pc, pc, #2801664 @ 0x2ac000 │ │ │ │ rsbvs r2, r8, sl, lsr #16 │ │ │ │ movwcs sp, #240 @ 0xf0 │ │ │ │ - bge 172ab0 │ │ │ │ + bge 172aa8 │ │ │ │ @ instruction: 0xf7ffa904 │ │ │ │ - blls 1a0d6c │ │ │ │ - blcs 32a4c <__time64@plt+0x21764> │ │ │ │ + blls 1a0d64 │ │ │ │ + blcs 32a44 <__time64@plt+0x2175c> │ │ │ │ sbchi pc, fp, r0 │ │ │ │ @ instruction: 0xf7fe4650 │ │ │ │ @ instruction: 0xf7ffff09 │ │ │ │ pkhbtmi pc, r3, r7, lsl #16 @ │ │ │ │ stmdals r4, {r2, r5, r8, ip, sp, pc} │ │ │ │ - bls 72ad8 │ │ │ │ + bls 72ad0 │ │ │ │ @ instruction: 0xff10f7f7 │ │ │ │ svceq 0x0000f1bb │ │ │ │ - bvc ad599c │ │ │ │ + bvc ad5994 │ │ │ │ tstpvc r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - bcs 392e8 <__time64@plt+0x28000> │ │ │ │ + bcs 392e0 <__time64@plt+0x27ff8> │ │ │ │ vand d29, d16, d15 │ │ │ │ vaddl.s8 , d0, d20 │ │ │ │ @ instruction: 0xf7fd0005 │ │ │ │ movwcs pc, #6527 @ 0x197f @ │ │ │ │ svcvc 0x0082f5b0 │ │ │ │ eorvc r6, fp, #104 @ 0x68 │ │ │ │ @ instruction: 0xf5a0db97 │ │ │ │ - blcs 7e094 │ │ │ │ + blcs 7e08c │ │ │ │ tstcs r0, ip, lsl #16 │ │ │ │ @ instruction: 0xf7ffa805 │ │ │ │ movwcs pc, #2285 @ 0x8ed @ │ │ │ │ vhsub.s8 d23, d0, d27 │ │ │ │ vorr.i32 d23, #0 @ 0x00000000 │ │ │ │ andcs r0, r1, #335544320 @ 0x14000000 │ │ │ │ @ instruction: 0xe7e2601a │ │ │ │ @ instruction: 0xf7fe6829 │ │ │ │ strmi pc, [r1], -fp, lsl #30 │ │ │ │ - rsbeq pc, r0, sp, asr #4 │ │ │ │ + subseq pc, r8, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ mcr2 7, 6, pc, cr14, cr14, {7} @ │ │ │ │ eorvc r2, fp, #0, 6 │ │ │ │ pop {r0, r1, r2, ip, sp, pc} │ │ │ │ @ instruction: 0xf7fe4ff0 │ │ │ │ @ instruction: 0xf240bebf │ │ │ │ vaddl.s8 , d0, d20 │ │ │ │ @@ -16391,145 +16389,145 @@ │ │ │ │ stmdbeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ stmib sp, {r2, r9, sl, lr}^ │ │ │ │ and r6, r7, r4, lsl #12 │ │ │ │ strtmi r6, [r0], -fp, ror #16 │ │ │ │ tstle r0, sl, lsr #22 │ │ │ │ @ instruction: 0xf7f8722e │ │ │ │ @ instruction: 0x4604f8bf │ │ │ │ - blcs 3fbcc <__time64@plt+0x2e8e4> │ │ │ │ + blcs 3fbc4 <__time64@plt+0x2e8dc> │ │ │ │ @ instruction: 0x4648d1f4 │ │ │ │ @ instruction: 0xf928f7fd │ │ │ │ rsbvs r4, r8, r3, lsl #12 │ │ │ │ strtmi r2, [r0], -sl, lsr #22 │ │ │ │ andhi pc, r8, r5, lsl #17 │ │ │ │ movwcs sp, #238 @ 0xee │ │ │ │ stmdbge r5, {r2, r9, fp, sp, pc} │ │ │ │ mcr2 7, 2, pc, cr8, cr15, {7} @ │ │ │ │ strmi r9, [r4], -r4, lsl #22 │ │ │ │ svceq 0x0000f1bb │ │ │ │ - blcs 5548c │ │ │ │ + blcs 55484 │ │ │ │ @ instruction: 0xf64cd054 │ │ │ │ - vmla.i d23, d16, d0[7] │ │ │ │ + vmla.i d23, d16, d0[5] │ │ │ │ stmdbls r5, {r1} │ │ │ │ mrc2 7, 3, pc, cr14, cr14, {7} │ │ │ │ @ instruction: 0xf43f2c00 │ │ │ │ qsub16mi sl, r0, lr │ │ │ │ ldrbmi r9, [r9], -r5, lsl #24 │ │ │ │ @ instruction: 0xf91af7f8 │ │ │ │ @ instruction: 0x4601465a │ │ │ │ tstpvc r8, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf7f84620 │ │ │ │ - bvc b1f714 │ │ │ │ + bvc b1f70c │ │ │ │ eorsle r2, sp, r0, lsl #22 │ │ │ │ movwcs r6, #2156 @ 0x86c │ │ │ │ @ instruction: 0xf1a4722b │ │ │ │ @ instruction: 0xf033033b │ │ │ │ addle r0, r2, r2, lsl #6 │ │ │ │ @ instruction: 0xf64c213b │ │ │ │ - vaddl.s8 q10, d0, d4 │ │ │ │ + vshr.s64 , q14, #64 │ │ │ │ @ instruction: 0xf8d50002 │ │ │ │ @ instruction: 0xf0068000 │ │ │ │ teqpcs sp, sp, lsl sl @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf64c4606 │ │ │ │ - vaddl.s8 q10, d0, d4 │ │ │ │ + vshr.s64 , q14, #64 │ │ │ │ @ instruction: 0xf0060002 │ │ │ │ @ instruction: 0x4603fa15 │ │ │ │ strtmi r4, [r0], -r1, asr #12 │ │ │ │ @ instruction: 0xf7fe461c │ │ │ │ strtmi pc, [r2], -r1, lsl #29 │ │ │ │ ldrtmi r4, [r1], -r3, lsl #12 │ │ │ │ - andseq pc, r8, sp, asr #4 │ │ │ │ + andseq pc, r0, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ mcr2 7, 2, pc, cr2, cr14, {7} @ │ │ │ │ @ instruction: 0xf7fee743 │ │ │ │ strmi pc, [r3], pc, asr #30 │ │ │ │ @ instruction: 0xf47f2c00 │ │ │ │ @ instruction: 0xf1bbaf36 │ │ │ │ @ instruction: 0xf47f0f00 │ │ │ │ ldr sl, [r8, -sl, lsl #30]! │ │ │ │ orrlt r9, r2, r3, lsl #20 │ │ │ │ @ instruction: 0xd1ac2b00 │ │ │ │ @ instruction: 0xe7b14693 │ │ │ │ - blcs 48008 <__time64@plt+0x36d20> │ │ │ │ + blcs 48000 <__time64@plt+0x36d18> │ │ │ │ str sp, [sp, r7, lsr #3]! │ │ │ │ eorvc pc, r4, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0xf8b6f7fd │ │ │ │ rsbvs r4, r8, r4, lsl #12 │ │ │ │ - blcs 5b2f8 │ │ │ │ + blcs 5b2f0 │ │ │ │ @ instruction: 0x469bbf18 │ │ │ │ svclt 0x0000e7a0 │ │ │ │ ldrbmi r6, [r0, -r0, lsl #17]! │ │ │ │ stmvs fp, {r7, fp, sp, lr} │ │ │ │ - blx fec27f28 │ │ │ │ + blx fec27f20 │ │ │ │ stmdbeq r0, {r7, ip, sp, lr, pc}^ │ │ │ │ svclt 0x00004770 │ │ │ │ vqrshl.s8 d27, d24, d0 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ stmiavs r0!, {r0, r2, sl} │ │ │ │ stmdbvs r5, {r5, r8, ip, sp, pc} │ │ │ │ - stcl 7, cr15, [lr, #956]! @ 0x3bc │ │ │ │ + ldcl 7, cr15, [r2, #956]! @ 0x3bc │ │ │ │ ldclt 0, cr6, [r8, #-660]! @ 0xfffffd6c │ │ │ │ - @ instruction: 0xff80f7ef │ │ │ │ + @ instruction: 0xff84f7ef │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ - ldrbcs pc, [r0, #1602] @ 0x642 @ │ │ │ │ + strbcs pc, [r8, #1602] @ 0x642 @ │ │ │ │ streq pc, [r3, #-704] @ 0xfffffd40 │ │ │ │ stmiavs r0!, {r0, r4, r7, ip, sp, pc}^ │ │ │ │ andcc lr, r1, #208, 18 @ 0x340000 │ │ │ │ eorsle r4, r6, #805306377 @ 0x30000009 │ │ │ │ subvs r1, r2, sl, asr ip │ │ │ │ mcrcs 8, 0, r7, cr10, cr14, {0} │ │ │ │ rscslt sp, r3, #56 @ 0x38 │ │ │ │ andsvc pc, r3, r5, lsr r8 @ │ │ │ │ svclt 0x0048067a │ │ │ │ - strbtle r6, [pc], #2272 @ 21484 <__time64@plt+0x1019c> │ │ │ │ + strbtle r6, [pc], #2272 @ 2147c <__time64@plt+0x10194> │ │ │ │ teqle r2, fp, lsr lr │ │ │ │ stmvs r1, {r5, r6, r7, fp, sp, lr} │ │ │ │ mrrcne 0, 0, lr, sl, cr6 │ │ │ │ ldmdavc fp, {r1, r6, sp, lr} │ │ │ │ svclt 0x00182b0a │ │ │ │ andsle r2, r0, r0, lsl #22 │ │ │ │ addmi r6, fp, #4390912 @ 0x430000 │ │ │ │ @ instruction: 0xf7efd3f5 │ │ │ │ - cdpne 14, 0, cr14, cr3, cr12, {6} │ │ │ │ + mcrne 14, 0, lr, cr3, cr0, {6} │ │ │ │ andcs fp, r1, #204, 30 @ 0x330 │ │ │ │ stmiavs r0!, {r9, sp}^ │ │ │ │ svclt 0x000c2b0a │ │ │ │ @ instruction: 0xf0022200 │ │ │ │ - bcs 21cc0 <__time64@plt+0x109d8> │ │ │ │ - blcs 2d5c54 │ │ │ │ + bcs 21cb8 <__time64@plt+0x109d0> │ │ │ │ + blcs 2d5c4c │ │ │ │ stmdavs r3!, {r4, r6, r7, r8, ip, lr, pc} │ │ │ │ eorvs r3, r3, r1, lsl #6 │ │ │ │ - ldc 7, cr15, [r8, #956]! @ 0x3bc │ │ │ │ + ldc 7, cr15, [ip, #956]! @ 0x3bc │ │ │ │ stmiavs r0!, {r0, r1, r9, sl, lr}^ │ │ │ │ ldmib r0, {r0, r1, r5, r8, sp, lr}^ │ │ │ │ addsmi r3, r3, #268435456 @ 0x10000000 │ │ │ │ @ instruction: 0xf7efd3c8 │ │ │ │ - @ instruction: 0x4606eeb0 │ │ │ │ + @ instruction: 0x4606eeb4 │ │ │ │ eorsle r1, r9, r1, asr #24 │ │ │ │ bicle r2, r6, sl, lsl #16 │ │ │ │ stmiavs r0!, {r0, r1, r5, fp, sp, lr}^ │ │ │ │ ldrbeq lr, [fp, -sl, ror #15]! │ │ │ │ @ instruction: 0xf1a6d408 │ │ │ │ - blcs 162198 │ │ │ │ + blcs 162190 │ │ │ │ ldm pc, {r0, r1, r3, r6, fp, ip, lr, pc}^ @ │ │ │ │ rsbcc pc, r5, #3 │ │ │ │ movteq r0, #41802 @ 0xa34a │ │ │ │ ldrtmi r6, [r0], -r1, ror #17 │ │ │ │ strls r2, [r4, -r0, lsl #14] │ │ │ │ - cdp 7, 5, cr15, cr4, cr15, {7} │ │ │ │ + cdp 7, 5, cr15, cr8, cr15, {7} │ │ │ │ @ instruction: 0xf7ef68e0 │ │ │ │ - bge 15cb68 │ │ │ │ + bge 15cb70 │ │ │ │ @ instruction: 0xf64d4606 │ │ │ │ - vbic.i32 d16, #8 @ 0x00000008 │ │ │ │ + vbic.i32 d16, #0 @ 0x00000000 │ │ │ │ stmiavs r0!, {r1, r8}^ │ │ │ │ - ldcl 7, cr15, [r4, #-956]! @ 0xfffffc44 │ │ │ │ + ldcl 7, cr15, [r8, #-956]! @ 0xfffffc44 │ │ │ │ vqsub.u8 d20, d16, d24 │ │ │ │ tstcs r8, pc, asr #5 │ │ │ │ @ instruction: 0xf7f62001 │ │ │ │ movwcs pc, #7159 @ 0x1bf7 @ │ │ │ │ strmi r6, [r5], -r2, lsr #18 │ │ │ │ stmdavs r3!, {r0, r1, sp, lr} │ │ │ │ stmdbls r4, {r1, r2, r4, r5, r7, r9, fp, ip} │ │ │ │ @@ -16537,15 +16535,15 @@ │ │ │ │ cmpvs r1, r7, lsl #2 │ │ │ │ movwvs lr, #10688 @ 0x29c0 │ │ │ │ andslt r4, r1, r8, lsr #12 │ │ │ │ mvnshi lr, #12386304 @ 0xbd0000 │ │ │ │ strtmi r2, [r8], -r0, lsl #10 │ │ │ │ pop {r0, r4, ip, sp, pc} │ │ │ │ stmiavs r0!, {r4, r5, r6, r7, r8, r9, pc}^ │ │ │ │ - stcl 7, cr15, [sl, #-956]! @ 0xfffffc44 │ │ │ │ + stcl 7, cr15, [lr, #-956]! @ 0xfffffc44 │ │ │ │ @ instruction: 0x46062118 │ │ │ │ @ instruction: 0xf7f62001 │ │ │ │ stmdbvs r7!, {r0, r3, r4, r6, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ andne lr, r0, #212, 18 @ 0x350000 │ │ │ │ movwcs r4, #17925 @ 0x4605 │ │ │ │ @ instruction: 0x46281bf6 │ │ │ │ movwcs r6, #43 @ 0x2b │ │ │ │ @@ -16556,112 +16554,112 @@ │ │ │ │ smlawble r7, r8, r2, r0 │ │ │ │ @ instruction: 0xf0002e22 │ │ │ │ stcle 0, cr8, [r1, #-748]! @ 0xfffffd14 │ │ │ │ stcle 14, cr2, [r1, #-144]! @ 0xffffff70 │ │ │ │ andsle r2, pc, pc, asr lr @ │ │ │ │ ldmib r4, {r5, r6, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7ef4500 │ │ │ │ - stmib sp, {r1, r2, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + stmib sp, {r1, r3, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ strmi r6, [r3], -r0, lsl #12 │ │ │ │ vmax.s8 d20, d13, d18 │ │ │ │ - vmvn.i32 d18, #12 @ 0x0000000c │ │ │ │ + vmvn.i32 d18, #4 @ 0x00000004 │ │ │ │ strtmi r0, [r9], -r2 │ │ │ │ - @ instruction: 0xff28f7ef │ │ │ │ + @ instruction: 0xff2cf7ef │ │ │ │ @ instruction: 0xf7ef68e0 │ │ │ │ - tstcs r8, r8, lsr sp │ │ │ │ + tstcs r8, ip, lsr sp │ │ │ │ andcs r4, r1, r6, lsl #12 │ │ │ │ - blx fe9df5b2 │ │ │ │ + blx fe9df5aa │ │ │ │ ldmib r4, {r0, r1, r2, r5, r8, fp, sp, lr}^ │ │ │ │ strmi r1, [r5], -r0, lsl #4 │ │ │ │ strb r2, [fp, r3, lsl #6] │ │ │ │ bicsle r2, pc, r1, lsr #28 │ │ │ │ @ instruction: 0xf10d2200 │ │ │ │ @ instruction: 0x46110810 │ │ │ │ vmax.s8 q10, , q0 │ │ │ │ vorr.i32 d16, #3072 @ 0x00000c00 │ │ │ │ movwls r0, #769 @ 0x301 │ │ │ │ - cmpppl r1, #74448896 @ p-variant is OBSOLETE @ 0x4700000 │ │ │ │ + movtpl pc, #38471 @ 0x9647 @ │ │ │ │ movweq pc, #4800 @ 0x12c0 @ │ │ │ │ - stcl 7, cr15, [r8, #-956] @ 0xfffffc44 │ │ │ │ + stcl 7, cr15, [ip, #-956] @ 0xfffffc44 │ │ │ │ @ instruction: 0xf7ef68e0 │ │ │ │ - pkhbtmi lr, r1, r8, lsl #26 │ │ │ │ + pkhbtmi lr, r1, ip, lsl #26 │ │ │ │ stmiavs r0!, {r1, r2, r3, sp, lr, pc}^ │ │ │ │ andls r1, r7, #23040 @ 0x5a00 │ │ │ │ ldmib r0, {r1, r2, r3, r4, ip, sp, lr}^ │ │ │ │ addsmi r3, r3, #268435456 @ 0x10000000 │ │ │ │ mrrcne 15, 3, fp, sl, cr14 │ │ │ │ ldmdavc lr, {r1, r6, sp, lr} │ │ │ │ rscslt sp, r3, #24, 4 @ 0x80000001 │ │ │ │ andsvc pc, r3, r5, lsr r8 @ │ │ │ │ svceq 0x008cf017 │ │ │ │ @ instruction: 0xf1a6d108 │ │ │ │ cdpcs 3, 5, cr0, cr15, cr3, {1} │ │ │ │ - blcs 912a0 │ │ │ │ + blcs 91298 │ │ │ │ @ instruction: 0x2e21d902 │ │ │ │ @ instruction: 0x81bdf040 │ │ │ │ andcc lr, r7, #3620864 @ 0x374000 │ │ │ │ @ instruction: 0xd1e0429a │ │ │ │ strbmi r2, [r0], -r1, lsl #2 │ │ │ │ - stc 7, cr15, [r4, #-956] @ 0xfffffc44 │ │ │ │ + stc 7, cr15, [r8, #-956] @ 0xfffffc44 │ │ │ │ ldrb r9, [sl, r7, lsl #22] │ │ │ │ - stcl 7, cr15, [lr, #956]! @ 0x3bc │ │ │ │ - ble ff8a8e7c │ │ │ │ + ldcl 7, cr15, [r2, #956]! @ 0x3bc │ │ │ │ + ble ff8a8e74 │ │ │ │ andcc lr, r7, #3620864 @ 0x374000 │ │ │ │ @ instruction: 0xf000429a │ │ │ │ mrrcne 1, 12, r8, sl, cr2 │ │ │ │ andcs r9, r0, #1879048192 @ 0x70000000 │ │ │ │ stmdbls r8, {r1, r3, r4, ip, sp, lr} │ │ │ │ movwpl lr, #27101 @ 0x69dd │ │ │ │ svclt 0x000242ab │ │ │ │ mlascs r8, sp, r8, pc @ │ │ │ │ andeq pc, r2, #66 @ 0x42 │ │ │ │ eorscs pc, r8, sp, lsl #17 │ │ │ │ ldrmi r9, [r3], #-2570 @ 0xfffff5f6 │ │ │ │ movweq lr, #10787 @ 0x2a23 │ │ │ │ - bne fe647eac │ │ │ │ + bne fe647ea4 │ │ │ │ addsmi r1, r0, #565248 @ 0x8a000 │ │ │ │ strmi fp, [fp], -r8, lsl #31 │ │ │ │ movwcc lr, #27085 @ 0x69cd │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ stmdavc fp!, {r1, r3, r7, r8, pc} │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ stmdbvs r0!, {r1, r2, r7, r8, pc}^ │ │ │ │ strtmi r2, [r9], -r1, lsl #4 │ │ │ │ @ instruction: 0xf91cf7f6 │ │ │ │ stmdacs r0, {r0, r1, r2, r9, sl, lr} │ │ │ │ cmnphi sp, r0 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7ef4628 │ │ │ │ - mcrrne 13, 6, lr, r6, cr4 │ │ │ │ + mcrrne 13, 6, lr, r6, cr8 │ │ │ │ @ instruction: 0xf7f64630 │ │ │ │ ldrtmi pc, [r2], -r1, asr #22 @ │ │ │ │ strmi r2, [r6], -r0, lsl #2 │ │ │ │ - stc 7, cr15, [r0, #956] @ 0x3bc │ │ │ │ + stc 7, cr15, [r4, #956] @ 0x3bc │ │ │ │ ldrtmi r4, [r0], -r9, lsr #12 │ │ │ │ - ldcl 7, cr15, [sl], #956 @ 0x3bc │ │ │ │ + ldcl 7, cr15, [lr], #956 @ 0x3bc │ │ │ │ tstcs r0, lr, lsr r0 │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - tstcs r8, lr, lsl #27 │ │ │ │ + @ instruction: 0x2118ed92 │ │ │ │ @ instruction: 0xf7f62001 │ │ │ │ movwcs pc, #23319 @ 0x5b17 @ │ │ │ │ strmi r6, [r5], -r3 │ │ │ │ ldmib r4, {r0, r1, r5, r8, fp, sp, lr}^ │ │ │ │ - bl fea69b04 │ │ │ │ + bl fea69afc │ │ │ │ subvs r0, r2, r3, lsl #6 │ │ │ │ mrsvs r2, (UNDEF: 102) │ │ │ │ smlabtcc r2, r0, r9, lr │ │ │ │ ldr r6, [sp, -r2, lsl #2] │ │ │ │ ldmdaeq r0, {r0, r2, r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x46404611 │ │ │ │ tstpeq ip, #268435460 @ p-variant is OBSOLETE @ 0x10000004 │ │ │ │ movweq pc, #4800 @ 0x12c0 @ │ │ │ │ @ instruction: 0xf6479300 │ │ │ │ - vorr.i32 , #256 @ 0x00000100 │ │ │ │ + vqdmlal.s , d0, d1[2] │ │ │ │ @ instruction: 0xf7ef0301 │ │ │ │ - stmiavs r0!, {r2, r4, r5, r7, sl, fp, sp, lr, pc}^ │ │ │ │ - stc 7, cr15, [r2], {239} @ 0xef │ │ │ │ + stmiavs r0!, {r3, r4, r5, r7, sl, fp, sp, lr, pc}^ │ │ │ │ + stc 7, cr15, [r6], {239} @ 0xef │ │ │ │ stmiavs r0!, {r1, r2, r9, sl, lr}^ │ │ │ │ andcc lr, r1, #208, 18 @ 0x340000 │ │ │ │ andsle r4, r7, #805306377 @ 0x30000009 │ │ │ │ subvs r1, r2, sl, asr ip │ │ │ │ svccs 0x0022781f │ │ │ │ ldrtmi sp, [fp], -sl, rrx │ │ │ │ andscc pc, r3, r5, lsr r8 @ │ │ │ │ @@ -16669,37 +16667,37 @@ │ │ │ │ subsle r2, sl, ip, asr pc │ │ │ │ andcc lr, r7, #3620864 @ 0x374000 │ │ │ │ @ instruction: 0xd059429a │ │ │ │ mrrcne 8, 14, r6, sl, cr0 │ │ │ │ andsvc r9, pc, r7, lsl #4 │ │ │ │ andcc lr, r1, #208, 18 @ 0x340000 │ │ │ │ mvnle r4, #805306377 @ 0x30000009 │ │ │ │ - stcl 7, cr15, [r2, #-956]! @ 0xfffffc44 │ │ │ │ + stcl 7, cr15, [r6, #-956]! @ 0xfffffc44 │ │ │ │ stmdacs r2!, {r0, r1, r2, r9, sl, lr} │ │ │ │ stmdacs r0, {r1, r4, r6, ip, lr, pc} │ │ │ │ addhi pc, pc, r0, lsl #5 │ │ │ │ - msrcs R8_fiq, sp │ │ │ │ + msrcs R8_usr, sp │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef2000 │ │ │ │ - @ instruction: 0x0659fdb5 │ │ │ │ + @ instruction: 0x0659fdb9 │ │ │ │ svccs 0x000ad508 │ │ │ │ vrhadd.s8 , , q8 │ │ │ │ - vorr.i32 d18, #4 @ 0x00000004 │ │ │ │ + vaddw.s8 q9, q0, d12 │ │ │ │ andcs r0, r0, r2, lsl #2 │ │ │ │ - stc2 7, cr15, [sl, #956]! @ 0x3bc │ │ │ │ + stc2 7, cr15, [lr, #956]! @ 0x3bc │ │ │ │ mvnsle r2, ip, asr pc │ │ │ │ ldmib r0, {r5, r6, r7, fp, sp, lr}^ │ │ │ │ addsmi r3, r3, #268435456 @ 0x10000000 │ │ │ │ mrrcne 15, 3, fp, sl, cr14 │ │ │ │ ldmdavc fp, {r1, r6, sp, lr} │ │ │ │ tstphi pc, r0, lsl #1 @ p-variant is OBSOLETE │ │ │ │ vqrdmlah.s q1, q0, q12 │ │ │ │ - blcs 1701db8 │ │ │ │ + blcs 1701db0 │ │ │ │ tstphi r3, r0, asr #6 @ p-variant is OBSOLETE │ │ │ │ - blcs 730540 │ │ │ │ + blcs 730538 │ │ │ │ cmnphi r5, r0, lsl #4 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf013e8df │ │ │ │ cmneq r3, r3, asr #1 │ │ │ │ cmneq r3, r3, ror r1 │ │ │ │ sbcseq r0, fp, r3, ror r1 │ │ │ │ cmneq r3, r9, lsr #1 │ │ │ │ cmneq r3, r3, ror r1 │ │ │ │ @@ -16711,67 +16709,67 @@ │ │ │ │ cmneq r3, r3, ror r1 │ │ │ │ cmneq r3, pc, asr #1 │ │ │ │ @ instruction: 0x0173009c │ │ │ │ cmneq r3, pc, lsl #1 │ │ │ │ ldrbeq r0, [r8], -r7, rrx │ │ │ │ strb sp, [r9, r2, lsr #9] │ │ │ │ strbmi r2, [r0], -r1, lsl #2 │ │ │ │ - stc 7, cr15, [r0], #-956 @ 0xfffffc44 │ │ │ │ + stc 7, cr15, [r4], #-956 @ 0xfffffc44 │ │ │ │ ldr r9, [pc, r7, lsl #22] │ │ │ │ andcc lr, r7, #3620864 @ 0x374000 │ │ │ │ @ instruction: 0xf000429a │ │ │ │ mrrcne 0, 14, r8, sl, cr12 │ │ │ │ andcs r9, r0, #1879048192 @ 0x70000000 │ │ │ │ stmdbls r8, {r1, r3, r4, ip, sp, lr} │ │ │ │ movwvc lr, #27101 @ 0x69dd │ │ │ │ @ instruction: 0x463842bb │ │ │ │ @ instruction: 0xf89dbf02 │ │ │ │ @ instruction: 0xf0422038 │ │ │ │ @ instruction: 0xf88d0202 │ │ │ │ - bls 2a9930 │ │ │ │ - b 8f28a0 │ │ │ │ - bls 162460 │ │ │ │ - bne fe2a82d0 │ │ │ │ + bls 2a9928 │ │ │ │ + b 8f2898 │ │ │ │ + bls 162458 │ │ │ │ + bne fe2a82c8 │ │ │ │ svclt 0x00884295 │ │ │ │ stmib sp, {r0, r1, r3, r9, sl, lr}^ │ │ │ │ @ instruction: 0xf7ef3306 │ │ │ │ - @ instruction: 0x2101ec94 │ │ │ │ + @ instruction: 0x2101ec98 │ │ │ │ @ instruction: 0xf7f63018 │ │ │ │ stmdbvs r3!, {r0, r3, r4, r6, r9, fp, ip, sp, lr, pc} │ │ │ │ ldrtmi r4, [r9], -r5, lsl #12 │ │ │ │ @ instruction: 0x30141af6 │ │ │ │ movwcs lr, #2516 @ 0x9d4 │ │ │ │ stcvs 8, cr15, [ip], {64} @ 0x40 │ │ │ │ ldccs 8, cr15, [r0], {64} @ 0x40 │ │ │ │ @ instruction: 0xf8402400 │ │ │ │ movwcs r3, #11272 @ 0x2c08 │ │ │ │ eorvs r6, fp, ip, lsr #2 │ │ │ │ - stc 7, cr15, [r0], #-956 @ 0xfffffc44 │ │ │ │ + stc 7, cr15, [r4], #-956 @ 0xfffffc44 │ │ │ │ strbmi r4, [r0], -r1, lsr #12 │ │ │ │ - ldc 7, cr15, [r4], #956 @ 0x3bc │ │ │ │ + ldc 7, cr15, [r8], #956 @ 0x3bc │ │ │ │ sbclt lr, r3, #90177536 @ 0x5600000 │ │ │ │ stmiavs r0!, {r2, r4, r6, r8, r9, sl, sp, lr, pc}^ │ │ │ │ vpmax.s8 d26, d13, d3 │ │ │ │ - vmla.f d17, d16, d0[0] │ │ │ │ + vsra.s64 d17, d24, #64 │ │ │ │ movwcs r0, #258 @ 0x102 │ │ │ │ @ instruction: 0xf7ef9303 │ │ │ │ - stmdacs r0, {r2, r3, r5, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r4, r5, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ rscshi pc, r8, r0, asr #6 │ │ │ │ - bcs 480d0 <__time64@plt+0x36de8> │ │ │ │ + bcs 480c8 <__time64@plt+0x36de0> │ │ │ │ rscshi pc, r4, r0 │ │ │ │ ldrdcc lr, [r7, -sp] │ │ │ │ @ instruction: 0xf0004299 │ │ │ │ stmiavs r0!, {r2, r3, r4, r6, r7, pc}^ │ │ │ │ tstls r7, r9, asr ip │ │ │ │ ldmib r0, {r1, r3, r4, ip, sp, lr}^ │ │ │ │ addsmi r3, r3, #268435456 @ 0x10000000 │ │ │ │ movwcc fp, #7996 @ 0x1f3c │ │ │ │ @ instruction: 0xf4ff6043 │ │ │ │ @ instruction: 0xf7efaf2b │ │ │ │ - stmiavs r0!, {r3, r5, r7, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r0!, {r2, r3, r5, r7, sl, fp, sp, lr, pc}^ │ │ │ │ andcc lr, r1, #208, 18 @ 0x340000 │ │ │ │ ldmib sp, {r2, r5, r8, r9, sl, sp, lr, pc}^ │ │ │ │ addsmi r3, sl, #1879048192 @ 0x70000000 │ │ │ │ adchi pc, sp, r0 │ │ │ │ mrrcne 8, 14, r6, sl, cr0 │ │ │ │ andcs r9, fp, #1879048192 @ 0x70000000 │ │ │ │ ldmib r0, {r1, r3, r4, ip, sp, lr}^ │ │ │ │ @@ -16819,443 +16817,443 @@ │ │ │ │ andls r1, r7, #23040 @ 0x5a00 │ │ │ │ andsvc r2, sl, ip, lsl #4 │ │ │ │ andcc lr, r1, #208, 18 @ 0x340000 │ │ │ │ strcs lr, [r0], -r0, asr #13 │ │ │ │ mcrcs 6, 0, lr, cr0, cr1, {4} │ │ │ │ mcrge 6, 2, pc, cr14, cr15, {7} @ │ │ │ │ ldrtmi r6, [r0], -r1, ror #17 │ │ │ │ - bl ffd5f98c │ │ │ │ - blcs 85b2f4 │ │ │ │ - blcs 8d5a4c │ │ │ │ + bl ffe5f984 │ │ │ │ + blcs 85b2ec │ │ │ │ + blcs 8d5a44 │ │ │ │ ldmib sp, {r0, r4, r5, r6, r8, ip, lr, pc}^ │ │ │ │ addsmi r3, sl, #1879048192 @ 0x70000000 │ │ │ │ stmiavs r0!, {r0, r1, r5, ip, lr, pc}^ │ │ │ │ andls r1, r7, #23040 @ 0x5a00 │ │ │ │ andsvc r2, sl, r2, lsr #4 │ │ │ │ andcc lr, r1, #208, 18 @ 0x340000 │ │ │ │ smlatbcs r1, r6, r6, lr │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c6cc │ │ │ │ + blls 21c6d4 │ │ │ │ @ instruction: 0xf7efe637 │ │ │ │ - @ instruction: 0x4603ec1e │ │ │ │ + strmi lr, [r3], -r2, lsr #24 │ │ │ │ ldrdcs lr, [r1, -ip] │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c6b8 │ │ │ │ + blls 21c6c0 │ │ │ │ ldmib sp, {r0, r2, r3, r8, r9, sl, sp, lr, pc}^ │ │ │ │ addsmi r3, sl, #1879048192 @ 0x70000000 │ │ │ │ stmiavs r0!, {r0, r2, r3, ip, lr, pc}^ │ │ │ │ andls r1, r7, #23040 @ 0x5a00 │ │ │ │ andsvc r2, sl, r0, lsr #4 │ │ │ │ andcc lr, r1, #208, 18 @ 0x340000 │ │ │ │ smlabbcs r1, sl, r6, lr │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c694 │ │ │ │ + blls 21c69c │ │ │ │ ldrdcs lr, [r1, -r5] │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c688 │ │ │ │ + blls 21c690 │ │ │ │ smlattcs r1, fp, r7, lr │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c67c │ │ │ │ + blls 21c684 │ │ │ │ tstcs r1, r5, ror #14 │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c670 │ │ │ │ + blls 21c678 │ │ │ │ @ instruction: 0x2101e791 │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c664 │ │ │ │ + blls 21c66c │ │ │ │ tstcs r1, ip, asr #14 │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c658 │ │ │ │ + blls 21c660 │ │ │ │ tstcs r1, r9, ror r7 │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c64c │ │ │ │ + blls 21c654 │ │ │ │ tstcs r1, sl, asr r7 │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - blls 21c640 │ │ │ │ + blls 21c648 │ │ │ │ smlabbcs r1, r5, r7, lr │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - bls 11c634 │ │ │ │ + bls 11c63c │ │ │ │ ldr r9, [ip, -r7, lsl #22] │ │ │ │ strbmi r2, [r0], -r1, lsl #2 │ │ │ │ - b ff85fa5c │ │ │ │ + b ff95fa54 │ │ │ │ ldrb r9, [r4, -r7, lsl #22] │ │ │ │ strbmi r2, [r0], -r1, lsl #2 │ │ │ │ - b ff6dfa68 │ │ │ │ + b ff7dfa60 │ │ │ │ ldrb r9, [lr, -r7, lsl #22]! │ │ │ │ - bicne pc, r8, sp, asr #4 │ │ │ │ + bicne pc, r0, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef2000 │ │ │ │ - vfma.f32 d31, d13, d15 │ │ │ │ - vmla.f d17, d16, d0[7] │ │ │ │ + @ instruction: 0xf24dfc23 │ │ │ │ + vmla.f d17, d16, d0[5] │ │ │ │ andcs r0, r0, r2, lsl #2 │ │ │ │ - ldc2 7, cr15, [r8], {239} @ 0xef │ │ │ │ - @ instruction: 0x11a8f24d │ │ │ │ + ldc2 7, cr15, [ip], {239} @ 0xef │ │ │ │ + asrne pc, sp, #4 @ │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4638 │ │ │ │ - svclt 0x0000fc11 │ │ │ │ + svclt 0x0000fc15 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ stmiavs r5!, {r1, r2, r9, sl, lr} │ │ │ │ eorsle r2, r6, r0, lsl #26 │ │ │ │ stmdacs r0, {r3, r5, r8, fp, sp, lr} │ │ │ │ vhadd.s8 , q0, q5 │ │ │ │ vmlal.s8 q10, d0, d16 │ │ │ │ @ instruction: 0xf8d80805 │ │ │ │ - blcs 2db04 <__time64@plt+0x1c81c> │ │ │ │ + blcs 2dafc <__time64@plt+0x1c814> │ │ │ │ rschi pc, r9, r0 │ │ │ │ @ instruction: 0xf380fab0 │ │ │ │ ldmdbeq fp, {r1, r3, r5, fp, sp, lr}^ │ │ │ │ svclt 0x000c2a03 │ │ │ │ @ instruction: 0xf043461f │ │ │ │ @ instruction: 0xb1b70701 │ │ │ │ tstle r7, r5, lsl #20 │ │ │ │ vmla.i8 q11, , q12 │ │ │ │ - vsra.s64 d18, d16, #64 │ │ │ │ + vaddw.s8 q9, q8, d24 │ │ │ │ @ instruction: 0xf7ef0102 │ │ │ │ - @ instruction: 0x4607ea5e │ │ │ │ + strmi lr, [r7], -r2, ror #20 │ │ │ │ stmiavs r0!, {r4, r5, r6, r8, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdbvs r5, {r1, r5, r7, pc} │ │ │ │ - b 1c5fafc │ │ │ │ + b 1d5faf4 │ │ │ │ stmib r6, {r0, r2, r5, r7, sp, lr}^ │ │ │ │ pop {r8, r9, sl, ip, sp, lr} │ │ │ │ stmdavs r3, {r3, r4, r5, r6, r7, r8, r9, pc} │ │ │ │ eorle r2, sp, r5, lsl #22 │ │ │ │ - tstpcc r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + tstpcc r0, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4628 │ │ │ │ - @ instruction: 0xf7fffbcf │ │ │ │ + @ instruction: 0xf7fffbd3 │ │ │ │ @ instruction: 0x4605fc75 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ @ instruction: 0xf7ffd1c2 │ │ │ │ strmi pc, [r7], -pc, ror #24 │ │ │ │ smlatblt r8, r0, r0, r6 │ │ │ │ cmplt r5, r5, lsl #18 │ │ │ │ msrmi CPSR_, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - blcs 3bbf0 <__time64@plt+0x2a908> │ │ │ │ + blcs 3bbe8 <__time64@plt+0x2a900> │ │ │ │ adchi pc, r9, r0 │ │ │ │ strb r2, [r1, r0, lsl #10]! │ │ │ │ vmax.s8 d20, d0, d31 │ │ │ │ vmlal.s8 q10, d0, d16 │ │ │ │ @ instruction: 0xf7ff0805 │ │ │ │ teqpvs r8, r9, asr ip @ p-variant is OBSOLETE │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ stccs 0, cr8, [r0, #-616] @ 0xfffffd98 │ │ │ │ str sp, [sp, lr, ror #1]! │ │ │ │ @ instruction: 0x9014f8d0 │ │ │ │ - @ instruction: 0x21a4f24d │ │ │ │ + orrscs pc, ip, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4648 │ │ │ │ - cmplt r8, r6, lsl sl │ │ │ │ + cmplt r8, sl, lsl sl │ │ │ │ vmax.s8 q10, , q4 │ │ │ │ - vorr.i32 d19, #12 @ 0x0000000c │ │ │ │ + vorr.i32 d19, #4 @ 0x00000004 │ │ │ │ strcs r0, [r1, -r2, lsl #2] │ │ │ │ - b 35fb8c │ │ │ │ + b 45fb84 │ │ │ │ @ instruction: 0xd1bd2800 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ stmdbvs r5, {r0, r4, r6, ip, lr, pc} │ │ │ │ - b 85fb9c │ │ │ │ + b 95fb94 │ │ │ │ stccs 0, cr6, [r0, #-660] @ 0xfffffd6c │ │ │ │ strtmi sp, [r8], -fp, asr #32 │ │ │ │ @ instruction: 0xf7ef692d │ │ │ │ - adcvs lr, r5, sl, lsl sl │ │ │ │ + adcvs lr, r5, lr, lsl sl │ │ │ │ suble r2, r6, r0, lsl #26 │ │ │ │ @ instruction: 0x9010f8d5 │ │ │ │ svceq 0x0000f1b9 │ │ │ │ stmdavs fp!, {r1, r5, r6, ip, lr, pc} │ │ │ │ cmple fp, r2, lsl #22 │ │ │ │ ldrdcc pc, [r0], -r9 │ │ │ │ cmple r7, r1, lsl #22 │ │ │ │ andseq pc, r4, #1073741825 @ 0x40000001 │ │ │ │ movwcs fp, #863 @ 0x35f │ │ │ │ ldrdeq pc, [r0], -r8 │ │ │ │ - bicsvs pc, r0, r2, asr #4 │ │ │ │ + bicvs pc, r8, r2, asr #4 │ │ │ │ smlabteq r3, r0, r2, pc @ │ │ │ │ - @ instruction: 0xf9d4f7f5 │ │ │ │ + @ instruction: 0xf9d8f7f5 │ │ │ │ @ instruction: 0xf7fc4605 │ │ │ │ strmi pc, [r3], -r9, asr #21 │ │ │ │ eorsvs r4, r3, r8, lsr #12 │ │ │ │ - ldmib r6!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmib sl!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf8d968a3 │ │ │ │ rsbsvs r2, r2, r4, lsl r0 │ │ │ │ ldmdbvs sp, {r0, r1, r3, r4, r5, r6, r7, r8, ip, sp, pc} │ │ │ │ @ instruction: 0xf7ef4618 │ │ │ │ - adcvs lr, r5, lr, ror #19 │ │ │ │ + strdvs lr, [r5], r2 @ │ │ │ │ strtmi fp, [r8], -sp, asr #3 │ │ │ │ @ instruction: 0xf7ef692d │ │ │ │ - adcvs lr, r5, r8, ror #19 │ │ │ │ + adcvs lr, r5, ip, ror #19 │ │ │ │ stmdavs fp!, {r0, r2, r3, r6, r8, r9, ip, sp, pc} │ │ │ │ @ instruction: 0xd12c2b04 │ │ │ │ pushvs {r3, r5, r9, sl, lr} │ │ │ │ - ldmib lr, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib r2!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ pop {r0, r2, r5, r7, sp, lr} │ │ │ │ @ instruction: 0x461083f8 │ │ │ │ - blx fe9dfc60 │ │ │ │ + blx fe9dfc58 │ │ │ │ eorsvs r6, r0, r3, lsr #17 │ │ │ │ @ instruction: 0x2014f8d9 │ │ │ │ - blcs 39e44 <__time64@plt+0x28b5c> │ │ │ │ + blcs 39e3c <__time64@plt+0x28b54> │ │ │ │ @ instruction: 0xf7efd1df │ │ │ │ - @ instruction: 0xf7fffb65 │ │ │ │ + @ instruction: 0xf7fffb69 │ │ │ │ strmi pc, [r5], -r3, ror #23 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ @ instruction: 0xf7ffd1b2 │ │ │ │ @ instruction: 0x4606fbdd │ │ │ │ smlatblt r8, r0, r0, r6 │ │ │ │ bicslt r6, r3, r3, lsl #18 │ │ │ │ - @ instruction: 0x21b4f24d │ │ │ │ + @ instruction: 0x21acf24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4628 │ │ │ │ - @ instruction: 0xf7fffb29 │ │ │ │ + @ instruction: 0xf7fffb2d │ │ │ │ strmi pc, [r5], -pc, asr #23 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ vrhadd.s8 , , │ │ │ │ - vmla.f d18, d16, d0[6] │ │ │ │ + vmla.f d18, d16, d0[4] │ │ │ │ strtmi r0, [r8], -r2, lsl #2 │ │ │ │ - blx 75fc82 │ │ │ │ - blx ff0dfcc6 │ │ │ │ + blx 85fc7a │ │ │ │ + blx ff0dfcbe │ │ │ │ smlawbvs r8, r1, r6, r4 │ │ │ │ orrsle r2, r6, r0, lsl #16 │ │ │ │ @ instruction: 0xf7ffe7e4 │ │ │ │ teqpvs r0, fp @ @ p-variant is OBSOLETE │ │ │ │ vabd.s8 q15, , q8 │ │ │ │ - vrshr.s64 d18, d0, #64 │ │ │ │ + vsubl.s8 q9, d16, d8 │ │ │ │ vhsub.s8 d16, d13, d2 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7ef7189 │ │ │ │ - svclt 0x0000fbeb │ │ │ │ + svclt 0x0000fbef │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ @ instruction: 0x4606b097 │ │ │ │ teqlt r5, #10813440 @ 0xa50000 │ │ │ │ stmdacs r0, {r3, r5, r8, fp, sp, lr} │ │ │ │ stmdavs fp!, {r1, r2, r4, r5, ip, lr, pc} │ │ │ │ andsle r2, r6, r3, lsl #22 │ │ │ │ tstle r7, r5, lsl #22 │ │ │ │ vmla.i8 q11, , q12 │ │ │ │ - vsra.s64 d18, d16, #64 │ │ │ │ + vaddw.s8 q9, q8, d24 │ │ │ │ @ instruction: 0xf7ef0102 │ │ │ │ - strmi lr, [r7], -r2, ror #18 │ │ │ │ + strmi lr, [r7], -r6, ror #18 │ │ │ │ stmiavs r0!, {r4, r5, r6, r8, fp, ip, sp, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdbvs r5, {r1, r2, r6, r8, sl, pc} │ │ │ │ - ldmdb r4!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdb r8!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorsvs r6, r7, r5, lsr #1 │ │ │ │ pop {r0, r1, r2, r4, ip, sp, pc} │ │ │ │ stmdavs r3, {r4, r5, r6, r7, r8, r9, pc} │ │ │ │ eorle r2, r2, r5, lsl #22 │ │ │ │ - tstpvs r4, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + mvnspl pc, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4628 │ │ │ │ - @ instruction: 0xf7fffad3 │ │ │ │ + @ instruction: 0xf7fffad7 │ │ │ │ @ instruction: 0x4605fb79 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ @ instruction: 0xf7ffd1d2 │ │ │ │ @ instruction: 0x4606fb73 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ stmdbvs r3, {r2, r3, r5, r6, r7, ip, lr, pc} │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ - blx 1adfd76 │ │ │ │ + blx 1adfd6e │ │ │ │ @ instruction: 0xe7e56130 │ │ │ │ - blx 19dfd7e │ │ │ │ + blx 19dfd76 │ │ │ │ stmdacs r0, {r3, r5, r8, sp, lr} │ │ │ │ stmdavs fp!, {r0, r1, r6, r7, r8, ip, lr, pc} │ │ │ │ sbcle r2, r5, r5, lsl #22 │ │ │ │ vaba.s8 q15, , q6 │ │ │ │ - vaddw.s8 , q0, d24 │ │ │ │ + vaddw.s8 , q0, d16 │ │ │ │ stmdbvs r0, {r1, r8}^ │ │ │ │ - stmdb r6!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb sl!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ bicsle r2, r3, r0, lsl #16 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ strhi pc, [fp, #-0] │ │ │ │ @ instruction: 0xf7ef6905 │ │ │ │ - adcvs lr, r5, sl, lsr r9 │ │ │ │ + adcvs lr, r5, lr, lsr r9 │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ strtmi r8, [r8], -r4, lsl #10 │ │ │ │ @ instruction: 0xf7ef692d │ │ │ │ - adcvs lr, r5, r2, lsr r9 │ │ │ │ + adcvs lr, r5, r6, lsr r9 │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ stmdavs fp!, {r0, r2, r5, r6, r7, pc} │ │ │ │ @ instruction: 0xf0402b05 │ │ │ │ vqadd.s8 q12, , │ │ │ │ - vbic.i32 d19, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 , q0, d24 │ │ │ │ stmdbvs r8!, {r1, r8}^ │ │ │ │ - stmdb r6, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb sl, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ teqle r4, r0, lsl #16 │ │ │ │ pushvs {r3, r5, r9, sl, lr} │ │ │ │ - ldmdb ip, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r0!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stccs 0, cr6, [r0, #-660] @ 0xfffffd6c │ │ │ │ tstphi r1, r0 @ p-variant is OBSOLETE │ │ │ │ - blcs 7bea0 │ │ │ │ + blcs 7be98 │ │ │ │ tstphi r4, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ tstcs r0, ip, lsr r2 │ │ │ │ @ instruction: 0xf7efa807 │ │ │ │ - stmdbvs r9!, {r1, r2, r3, r5, r6, r7, r8, fp, sp, lr, pc}^ │ │ │ │ + stmdbvs r9!, {r1, r4, r5, r6, r7, r8, fp, sp, lr, pc}^ │ │ │ │ andcs r9, r0, #8, 2 │ │ │ │ stmdbge r6, {r5, r7, r8, fp, sp, lr} │ │ │ │ movwls r2, #25346 @ 0x6302 │ │ │ │ ldc2l 7, cr15, [r0, #-980]! @ 0xfffffc2c │ │ │ │ stmdacs r0, {r0, r1, r2, r9, sl, lr} │ │ │ │ strbthi pc, [lr], #0 @ │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ strbhi pc, [sp], #0 @ │ │ │ │ @ instruction: 0xf7ef6905 │ │ │ │ - strdvs lr, [r5], ip @ │ │ │ │ + adcvs lr, r5, r0, lsl #18 │ │ │ │ eorsvs r6, r3, fp, lsr r8 │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ stmdavs fp!, {r2, r6, r7, pc} │ │ │ │ @ instruction: 0xf0402b04 │ │ │ │ strtmi r8, [r8], -r7, asr #1 │ │ │ │ @ instruction: 0xf7ef692d │ │ │ │ - adcvs lr, r5, lr, ror #17 │ │ │ │ + strdvs lr, [r5], r2 @ │ │ │ │ @ instruction: 0xf8d5e778 │ │ │ │ vqadd.s8 d24, d13, d4 │ │ │ │ - vmla.f d19, d0, d0[4] │ │ │ │ + vorr.i32 , #8 @ 0x00000008 │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - stmia r6, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia sl, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ vqadd.s8 d24, d29, d28 │ │ │ │ - vmla.f d22, d0, d0[1] │ │ │ │ + vbic.i32 d22, #12 @ 0x0000000c │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - ldm ip!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmia r0, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ vhadd.s8 q12, , q0 │ │ │ │ - vbic.i32 d22, #12 @ 0x0000000c │ │ │ │ + vbic.i32 d22, #4 @ 0x00000004 │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - ldm r2!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldm r6!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ @ instruction: 0xf64880d2 │ │ │ │ - vsra.s64 d23, d20, #64 │ │ │ │ + vaddw.s8 , q8, d28 │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - stmia r8!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmia ip!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ vqadd.s8 q12, , q3 │ │ │ │ - vbic.i32 d22, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 q11, q0, d24 │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - ldm lr, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmia r2!, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ @ instruction: 0xf64c80da │ │ │ │ - vsra.s64 , q0, #64 │ │ │ │ + vmla.f d19, d16, d0[2] │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - ldm r4, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldm r8, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ vrhadd.s8 d24, d9, d6 │ │ │ │ - vmla.f d21, d16, d0[3] │ │ │ │ + vmla.f d21, d16, d0[1] │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - stm sl, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stm lr, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ strbmi r8, [r0], -r4, asr #3 │ │ │ │ - mvnsmi pc, sp, asr #4 │ │ │ │ + mvnmi pc, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - stm r0, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stm r4, {r0, r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmdacs r0, {r0, r1, r2, r9, sl, lr} │ │ │ │ mrshi pc, (UNDEF: 76) @ │ │ │ │ - msrvs R8_fiq, sp │ │ │ │ + msrvs R8_usr, sp │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - stmdacs r0, {r1, r2, r4, r5, r6, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r3, r4, r5, r6, fp, sp, lr, pc} │ │ │ │ bicshi pc, r7, #0 │ │ │ │ - msrvs R8_usr, sp │ │ │ │ + tstpvs r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - stmdacs r0, {r2, r3, r5, r6, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r4, r5, r6, fp, sp, lr, pc} │ │ │ │ @ instruction: 0x83b1f000 │ │ │ │ - tstpvs r4, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + tstpvs ip, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4640 │ │ │ │ - stmdacs r0, {r1, r5, r6, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r5, r6, fp, sp, lr, pc} │ │ │ │ cmpcs r0, r2, asr #2 │ │ │ │ @ instruction: 0xf7f52001 │ │ │ │ ldrshtvs pc, [r0], -r9 @ │ │ │ │ - blx 1f5ff34 │ │ │ │ + blx 1f5ff2c │ │ │ │ movwcs r6, #43061 @ 0xa835 │ │ │ │ eorvs r4, fp, r8, lsr #12 │ │ │ │ @ instruction: 0xf876f001 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ orrhi pc, fp, #0 │ │ │ │ - blcs bbf5c │ │ │ │ + blcs bbf54 │ │ │ │ orrhi pc, sp, #64 @ 0x40 │ │ │ │ @ instruction: 0xf7f53014 │ │ │ │ vrecps.f32 d31, d0, d11 │ │ │ │ vrsra.s64 , q12, #64 │ │ │ │ cmnvs r8, r5, lsl #6 │ │ │ │ - blcs 3bfd4 <__time64@plt+0x2acec> │ │ │ │ + blcs 3bfcc <__time64@plt+0x2ace4> │ │ │ │ msrhi SPSR_, #64 @ 0x40 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ strthi pc, [r5], #-0 │ │ │ │ @ instruction: 0xf7ef6906 │ │ │ │ - @ instruction: 0xf105e854 │ │ │ │ + @ instruction: 0xf105e858 │ │ │ │ adcvs r0, r6, r8, lsl r0 │ │ │ │ stc2 7, cr15, [ip, #1020]! @ 0x3fc │ │ │ │ eoreq pc, r0, r5, lsl #2 │ │ │ │ @ instruction: 0xff7af000 │ │ │ │ strb r6, [pc, -r5, lsr #17] │ │ │ │ - blx 175ff90 │ │ │ │ + blx 175ff88 │ │ │ │ adcvs r4, r0, r5, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7ffaf14 │ │ │ │ @ instruction: 0x4605fa55 │ │ │ │ tstlt r8, r0, lsr #1 │ │ │ │ - blcs 17bfb8 │ │ │ │ + blcs 17bfb0 │ │ │ │ svcge 0x004df43f │ │ │ │ - bicspl pc, ip, sp, asr #4 │ │ │ │ + bicspl pc, r4, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4628 │ │ │ │ - @ instruction: 0xf7fff99f │ │ │ │ + @ instruction: 0xf7fff9a3 │ │ │ │ strmi pc, [r5], -r5, asr #20 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ svcge 0x0035f47f │ │ │ │ - mvnspl pc, sp, asr #4 │ │ │ │ + mvnpl pc, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4628 │ │ │ │ - @ instruction: 0x4628f991 │ │ │ │ + @ instruction: 0x4628f995 │ │ │ │ @ instruction: 0xf7ef692d │ │ │ │ - adcvs lr, r5, r0, lsr #16 │ │ │ │ + adcvs lr, r5, r4, lsr #16 │ │ │ │ adcne pc, r8, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0xf0016030 │ │ │ │ stmiavs r5!, {r0, r1, r2, r3, r4, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x4628e71c │ │ │ │ @ instruction: 0xf7ef692d │ │ │ │ - adcvs lr, r5, r2, lsl r8 │ │ │ │ + adcvs lr, r5, r6, lsl r8 │ │ │ │ rscne pc, r8, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0xf0016030 │ │ │ │ stmiavs r5!, {r0, r4, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7ffe70e │ │ │ │ @ instruction: 0x4605fa1b │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ mcrge 4, 7, pc, cr8, cr15, {3} @ │ │ │ │ - cmppcc r0, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppcc r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4628 │ │ │ │ - strtmi pc, [r8], -r7, ror #18 │ │ │ │ + strtmi pc, [r8], -fp, ror #18 │ │ │ │ @ instruction: 0xf7ee692d │ │ │ │ - strdvs lr, [r5], r6 @ │ │ │ │ + strdvs lr, [r5], sl @ │ │ │ │ eorcs pc, r8, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0xf0006030 │ │ │ │ stmiavs r5!, {r0, r2, r4, r5, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x4628e6f2 │ │ │ │ @ instruction: 0xf7ee692d │ │ │ │ - adcvs lr, r5, r8, ror #31 │ │ │ │ + adcvs lr, r5, ip, ror #31 │ │ │ │ rsbne pc, r8, r0, asr #4 │ │ │ │ andeq pc, r5, r0, asr #5 │ │ │ │ @ instruction: 0xf0006030 │ │ │ │ stmiavs r5!, {r0, r1, r2, r5, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ smlalttcs lr, r0, r4, r6 │ │ │ │ @ instruction: 0xf7f52001 │ │ │ │ stmiavs r3!, {r0, r1, r3, r4, r6, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - blcs 3a134 <__time64@plt+0x28e4c> │ │ │ │ + blcs 3a12c <__time64@plt+0x28e44> │ │ │ │ @ instruction: 0x83a3f000 │ │ │ │ ldmdbvs pc, {r3, r4, r9, sl, lr} @ │ │ │ │ - svc 0x00d0f7ee │ │ │ │ + svc 0x00d4f7ee │ │ │ │ movwcs r6, #6197 @ 0x1835 │ │ │ │ strtmi r6, [r8], -r7, lsr #1 │ │ │ │ @ instruction: 0xf000602b │ │ │ │ stmiavs r0!, {r0, r4, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdavs r3, {r0, r1, r2, r3, r4, r5, r7, r9, pc} │ │ │ │ @ instruction: 0xf0402b02 │ │ │ │ @@ -17264,25 +17262,25 @@ │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ ldmdavs fp, {r3, r5, r6, r8, sp, lr} │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ stmiavs r0!, {r2, r4, r7, r9, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdbvs r6, {r7, r8, r9, pc} │ │ │ │ - svc 0x00aef7ee │ │ │ │ + svc 0x00b2f7ee │ │ │ │ andseq pc, r8, r5, lsl #2 │ │ │ │ @ instruction: 0xf7ff60a6 │ │ │ │ stmiavs r5!, {r0, r1, r2, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ smlaltbcs lr, r0, lr, r6 │ │ │ │ @ instruction: 0xf7f52001 │ │ │ │ stmiavs r3!, {r0, r2, r5, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - blcs 3a1a0 <__time64@plt+0x28eb8> │ │ │ │ + blcs 3a198 <__time64@plt+0x28eb0> │ │ │ │ msrhi SPSR_fsc, #0 │ │ │ │ ldmdbvs pc, {r3, r4, r9, sl, lr} @ │ │ │ │ - svc 0x009af7ee │ │ │ │ + svc 0x009ef7ee │ │ │ │ movwcs r6, #18485 @ 0x4835 │ │ │ │ strtmi r6, [r8], -r7, lsr #1 │ │ │ │ @ instruction: 0xf000602b │ │ │ │ stmiavs r0!, {r0, r1, r3, r4, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdavs r3, {r1, r5, r6, r9, pc} │ │ │ │ @ instruction: 0xf0402b02 │ │ │ │ @@ -17291,33 +17289,33 @@ │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ ldmdavs fp, {r3, r5, r6, r8, sp, lr} │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ stmiavs r0!, {r0, r1, r2, r4, r5, r9, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdbvs r6, {r1, r3, r6, r8, r9, pc} │ │ │ │ - svc 0x0078f7ee │ │ │ │ + svc 0x007cf7ee │ │ │ │ andseq pc, r8, r5, lsl #2 │ │ │ │ @ instruction: 0xf7ff60a6 │ │ │ │ @ instruction: 0xf105fcd1 │ │ │ │ @ instruction: 0xf0000020 │ │ │ │ @ instruction: 0xf105fe9f │ │ │ │ @ instruction: 0xf0000024 │ │ │ │ stmiavs r0!, {r0, r1, r3, r5, r6, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdavs r3, {r3, r4, r9, pc} │ │ │ │ @ instruction: 0xf0402b01 │ │ │ │ stmdbvs r3, {r0, r4, r5, r6, r7, pc}^ │ │ │ │ stmdbvs r6, {r0, r1, r3, r5, r7, r9, sp, lr} │ │ │ │ - svc 0x005ef7ee │ │ │ │ + svc 0x0062f7ee │ │ │ │ eoreq pc, ip, r5, lsl #2 │ │ │ │ @ instruction: 0xf7ff60a6 │ │ │ │ @ instruction: 0xf105fdc3 │ │ │ │ @ instruction: 0xf7ff0030 │ │ │ │ - blvs a61874 │ │ │ │ + blvs a6186c │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ @ instruction: 0x462980bf │ │ │ │ @ instruction: 0xffd4f7f6 │ │ │ │ ldrb r6, [r3], -r5, lsr #17 │ │ │ │ andcs r2, r1, r0, asr #2 │ │ │ │ stc2l 7, cr15, [sl, #980] @ 0x3d4 │ │ │ │ @ instruction: 0xf7ff6030 │ │ │ │ @@ -17330,59 +17328,59 @@ │ │ │ │ stmdavs r3, {r0, r3, r5, r7, pc} │ │ │ │ @ instruction: 0xf0402b02 │ │ │ │ andscc r8, r4, fp, lsr #1 │ │ │ │ stc2l 7, cr15, [sl, #980]! @ 0x3d4 │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ andseq pc, r4, r8, asr #17 │ │ │ │ - blcs 3c238 <__time64@plt+0x2af50> │ │ │ │ + blcs 3c230 <__time64@plt+0x2af48> │ │ │ │ adcshi pc, ip, r0, asr #32 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ rscshi pc, r3, #0 │ │ │ │ @ instruction: 0xf7ee6905 │ │ │ │ - @ instruction: 0xf108ef22 │ │ │ │ + @ instruction: 0xf108ef26 │ │ │ │ adcvs r0, r5, r8, lsl r0 │ │ │ │ ldc2l 7, cr15, [sl], #-1020 @ 0xfffffc04 │ │ │ │ eoreq pc, r0, r8, lsl #2 │ │ │ │ cdp2 0, 4, cr15, cr8, cr0, {0} │ │ │ │ eoreq pc, r4, r8, lsl #2 │ │ │ │ - blx 55e1fa │ │ │ │ + blx 55e1f2 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ addshi pc, r8, r0 │ │ │ │ - blcs 7c210 │ │ │ │ + blcs 7c208 │ │ │ │ addshi pc, sl, r0, asr #32 │ │ │ │ stmdbvs r3, {r1, r2, r8, fp, sp, lr}^ │ │ │ │ eorcc pc, r8, r8, asr #17 │ │ │ │ - svc 0x0006f7ee │ │ │ │ + svc 0x000af7ee │ │ │ │ cdpcs 0, 0, cr6, cr0, cr6, {5} │ │ │ │ addhi pc, r3, r0 │ │ │ │ ldmdbvs r5!, {r0, r4, r5, r7, r9, sl, lr} │ │ │ │ rsbsle r2, r9, r0, lsl #26 │ │ │ │ - bcs 3c4b0 <__time64@plt+0x2b1c8> │ │ │ │ + bcs 3c4a8 <__time64@plt+0x2b1c0> │ │ │ │ rschi pc, fp, r0 │ │ │ │ - blcs 3c67c <__time64@plt+0x2b394> │ │ │ │ + blcs 3c674 <__time64@plt+0x2b38c> │ │ │ │ sbcshi pc, ip, r0 │ │ │ │ @ instruction: 0x2e00691e │ │ │ │ rschi pc, ip, r0 │ │ │ │ svceq 0x0000f1b9 │ │ │ │ @ instruction: 0xf8d9d008 │ │ │ │ - blcs ee248 │ │ │ │ + blcs ee240 │ │ │ │ tstlt sp, r4, lsl #2 │ │ │ │ - blcs 17c2fc │ │ │ │ + blcs 17c2f4 │ │ │ │ rschi pc, r7, r0 │ │ │ │ - @ instruction: 0x41a4f24d │ │ │ │ + orrsmi pc, ip, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ef4648 │ │ │ │ - cmppcs r0, sp, asr #16 @ p-variant is OBSOLETE │ │ │ │ + cmppcs r0, r1, asr r8 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7f52001 │ │ │ │ stmiavs r3!, {r0, r2, r3, r4, r6, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ - blcs 3a330 <__time64@plt+0x29048> │ │ │ │ + blcs 3a328 <__time64@plt+0x29040> │ │ │ │ adchi pc, r5, #0 │ │ │ │ ldmdbvs pc, {r3, r4, r9, sl, lr} @ │ │ │ │ - cdp 7, 13, cr15, cr2, cr14, {7} │ │ │ │ + cdp 7, 13, cr15, cr6, cr14, {7} │ │ │ │ movwcs r6, #22581 @ 0x5835 │ │ │ │ strtmi r6, [r8], -r7, lsr #1 │ │ │ │ @ instruction: 0xf000602b │ │ │ │ stmiavs r0!, {r0, r1, r4, r6, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdavs r3, {r0, r5, r7, pc} │ │ │ │ @ instruction: 0xf0402b02 │ │ │ │ @@ -17391,119 +17389,119 @@ │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ ldmdavs fp, {r3, r5, r6, r8, sp, lr} │ │ │ │ cmnle r6, r0, lsl #22 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ addhi pc, r3, #0 │ │ │ │ @ instruction: 0xf7ee6906 │ │ │ │ - @ instruction: 0xf105eeb2 │ │ │ │ + @ instruction: 0xf105eeb6 │ │ │ │ adcvs r0, r6, r8, lsl r0 │ │ │ │ stc2 7, cr15, [sl], {255} @ 0xff │ │ │ │ eoreq pc, r0, r5, lsl #2 │ │ │ │ ldc2l 0, cr15, [r8] │ │ │ │ eoreq pc, r4, r5, lsl #2 │ │ │ │ - blx fe95e2d8 │ │ │ │ + blx fe95e2d0 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ stmdavs r3, {r0, r3, r4, r6, ip, lr, pc} │ │ │ │ @ instruction: 0xd12b2b01 │ │ │ │ adcvs r6, fp, #1097728 @ 0x10c000 │ │ │ │ @ instruction: 0xf7ee6906 │ │ │ │ - @ instruction: 0xf105ee9a │ │ │ │ + @ instruction: 0xf105ee9e │ │ │ │ adcvs r0, r6, ip, lsr #32 │ │ │ │ ldc2l 7, cr15, [lr], #1020 @ 0x3fc │ │ │ │ ldr r6, [r9, #2213] @ 0x8a5 │ │ │ │ ldr r6, [r7, #2213] @ 0x8a5 │ │ │ │ @ instruction: 0xf8a4f7ff │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ svcge 0x0051f47f │ │ │ │ - cmnpmi ip, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmnpmi r4, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - @ instruction: 0xfff2f7ee │ │ │ │ + @ instruction: 0xfff6f7ee │ │ │ │ @ instruction: 0xf898f7ff │ │ │ │ teqvs r0, r5, lsl #12 │ │ │ │ @ instruction: 0xf7ffe780 │ │ │ │ pkhbtmi pc, r1, r3, lsl #17 @ │ │ │ │ cmplt r0, #160 @ 0xa0 │ │ │ │ ldrb r4, [r6, -r6, lsl #12]! │ │ │ │ @ instruction: 0xf88cf7ff │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ svcge 0x0062f47f │ │ │ │ - mvncc pc, sp, asr #4 │ │ │ │ + bicscc pc, r8, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - @ instruction: 0xffdaf7ee │ │ │ │ + @ instruction: 0xffdef7ee │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f5681d │ │ │ │ @ instruction: 0xf8d8fcb9 │ │ │ │ @ instruction: 0x46023014 │ │ │ │ strtmi r9, [r8], -r2, lsl #6 │ │ │ │ - cmppmi r0, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppmi r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdpl pc, [r8], -r8 │ │ │ │ bicvs pc, r3, #64, 4 │ │ │ │ strhi lr, [r0, #-2509] @ 0xfffff633 │ │ │ │ - svc 0x0016f7ee │ │ │ │ + svc 0x001af7ee │ │ │ │ @ instruction: 0xf7ffe726 │ │ │ │ strmi pc, [r5], -r3, ror #16 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ @ instruction: 0x4606d039 │ │ │ │ @ instruction: 0xf7ffe745 │ │ │ │ adcvs pc, r0, fp, asr r8 @ │ │ │ │ lslle r2, r0, #16 │ │ │ │ vabd.s8 q15, q8, q7 │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ vcgt.s8 d16, d13, d5 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ ldmdavs lr, {r1} │ │ │ │ stc2 7, cr15, [lr], {245} @ 0xf5 │ │ │ │ strmi r6, [r2], -fp, ror #18 │ │ │ │ ldrtmi r9, [r0], -r2, lsl #6 │ │ │ │ - tstpmi r0, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + tstpmi r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stmib sp, {r0, r1, r3, r5, r7, fp, sp, lr}^ │ │ │ │ vst2.8 {d21-d24}, [pc], r0 │ │ │ │ @ instruction: 0xf7ee63ce │ │ │ │ - strb lr, [sp, -lr, ror #29]! │ │ │ │ + @ instruction: 0xe76deef2 │ │ │ │ @ instruction: 0xf83af7ff │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ svcge 0x0059f47f │ │ │ │ - teqpmi r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpmi r0, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - @ instruction: 0xff88f7ee │ │ │ │ + @ instruction: 0xff8cf7ee │ │ │ │ @ instruction: 0xf7ff9205 │ │ │ │ - bls 1a04a8 │ │ │ │ + bls 1a04a0 │ │ │ │ tstvs r0, r6, lsl #12 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0x4603af1f │ │ │ │ @ instruction: 0xf7ffe718 │ │ │ │ strmi pc, [r6], -r3, lsr #16 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ svcge 0x0016f43f │ │ │ │ str r4, [fp, -r2, lsl #12] │ │ │ │ @ instruction: 0xf7ff9305 │ │ │ │ - blls 1a0480 │ │ │ │ + blls 1a0478 │ │ │ │ tstvs r8, r6, lsl #12 │ │ │ │ vabd.s8 d30, d13, d12 │ │ │ │ - vsra.s64 d20, d8, #64 │ │ │ │ + vsra.s64 d20, d0, #64 │ │ │ │ stmdbvs r8!, {r1, r8}^ │ │ │ │ - ldcl 7, cr15, [ip, #952] @ 0x3b8 │ │ │ │ + stcl 7, cr15, [r0, #952]! @ 0x3b8 │ │ │ │ @ instruction: 0xf43f2e00 │ │ │ │ stmdacs r0, {r0, r1, r2, r3, r8, r9, sl, fp, sp, pc} │ │ │ │ svcge 0x000cf47f │ │ │ │ - blcs 7c50c │ │ │ │ + blcs 7c504 │ │ │ │ svcge 0x0008f47f │ │ │ │ @ instruction: 0xf1086976 │ │ │ │ stmiavs r0!, {r2, r3, r5, r8, sl} │ │ │ │ stmdbeq r3, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ @ instruction: 0xf8d081b4 │ │ │ │ @ instruction: 0xf7ee8010 │ │ │ │ - @ instruction: 0xf1b9ede2 │ │ │ │ + @ instruction: 0xf1b9ede6 │ │ │ │ @ instruction: 0xf8c40901 │ │ │ │ andle r8, r1, r8 │ │ │ │ ldrb r4, [r1, r0, asr #12]! │ │ │ │ vcge.f32 d18, d0, d0 │ │ │ │ @ instruction: 0xf01681ca │ │ │ │ subsle r0, r2, r3, lsl #6 │ │ │ │ andsle r2, r9, r1, lsl #22 │ │ │ │ @@ -17544,15 +17542,15 @@ │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ stmiavs r0!, {r0, r2, r4, r5, r6, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ stmdavs sp!, {r3, r5, r7, r8, ip, sp, pc} │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ smlsdxcc r3, pc, r1, r8 @ │ │ │ │ adcsmi r3, lr, #4, 10 @ 0x1000000 │ │ │ │ @ instruction: 0x4628d01d │ │ │ │ - blx ffa60522 │ │ │ │ + blx ffa6051a │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ @ instruction: 0xf7fed1d1 │ │ │ │ adcvs pc, r0, pc, lsl #31 │ │ │ │ @ instruction: 0xf7fee7cd │ │ │ │ adcvs pc, r0, fp, lsl #31 │ │ │ │ @ instruction: 0xf7fee7b4 │ │ │ │ adcvs pc, r0, r7, lsl #31 │ │ │ │ @@ -17560,424 +17558,424 @@ │ │ │ │ adcvs pc, r0, r3, lsl #31 │ │ │ │ @ instruction: 0xf7fee7d7 │ │ │ │ adcvs pc, r0, pc, ror pc @ │ │ │ │ @ instruction: 0xf7fee7c9 │ │ │ │ adcvs pc, r0, fp, ror pc @ │ │ │ │ stmdacs r0, {r3, r4, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ cmpphi r3, r0 @ p-variant is OBSOLETE │ │ │ │ - blcs 13c570 │ │ │ │ + blcs 13c568 │ │ │ │ cmpphi r0, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ msrhi CPSR_sxc, r0 │ │ │ │ @ instruction: 0xf7ee6905 │ │ │ │ - adcvs lr, r5, r6, asr sp │ │ │ │ + adcvs lr, r5, sl, asr sp │ │ │ │ @ instruction: 0xf7fee45a │ │ │ │ adcvs pc, r0, r7, ror #30 │ │ │ │ @ instruction: 0xf7fee79c │ │ │ │ adcvs pc, r0, r3, ror #30 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ ldrb sl, [r5], r2, ror #27 │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f5681e │ │ │ │ stmdbvs fp!, {r0, r2, r4, r7, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ movwls r4, #9730 @ 0x2602 │ │ │ │ vmin.s8 d20, d13, d16 │ │ │ │ - vsra.s64 d19, d24, #64 │ │ │ │ + vsra.s64 d19, d16, #64 │ │ │ │ stmiavs fp!, {r1, r8} │ │ │ │ movwpl lr, #2509 @ 0x9cd │ │ │ │ msrvs CPSR_xc, #64, 4 │ │ │ │ - ldcl 7, cr15, [r4, #952]! @ 0x3b8 │ │ │ │ + ldcl 7, cr15, [r8, #952]! @ 0x3b8 │ │ │ │ @ instruction: 0xf7fee5ad │ │ │ │ adcvs pc, r0, r1, asr #30 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ vmla.f32 d26, d29, d8 │ │ │ │ - vsra.s64 , q12, #64 │ │ │ │ + vsra.s64 , q8, #64 │ │ │ │ @ instruction: 0xf7ee0102 │ │ │ │ - vceq.f32 d31, d16, d15 │ │ │ │ + @ instruction: 0xf240fe93 │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ vcgt.s8 d16, d13, d5 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ ldmdavs lr, {r1} │ │ │ │ - blx 1be05ca │ │ │ │ + blx 1be05c2 │ │ │ │ strmi r6, [r2], -fp, ror #18 │ │ │ │ ldrtmi r9, [r0], -r2, lsl #6 │ │ │ │ - cmnpcc r0, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + msrcc (UNDEF: 104), sp │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stmib sp, {r0, r1, r3, r5, r7, fp, sp, lr}^ │ │ │ │ vcgt.s8 d21, d0, d0 │ │ │ │ @ instruction: 0xf7ee6301 │ │ │ │ - ldrb lr, [r0, #-3534] @ 0xfffff232 │ │ │ │ + ldrb lr, [r0, #-3538] @ 0xfffff22e │ │ │ │ @ instruction: 0xff1af7fe │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ ldcge 4, cr15, [fp, #-508]! @ 0xfffffe04 │ │ │ │ - orrscc pc, ip, sp, asr #4 │ │ │ │ + orrscc pc, r4, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - cdp2 7, 6, cr15, cr8, cr14, {7} │ │ │ │ + cdp2 7, 6, cr15, cr12, cr14, {7} │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f5681e │ │ │ │ stmdbvs fp!, {r0, r1, r2, r6, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ movwls r4, #9730 @ 0x2602 │ │ │ │ vmin.s8 d20, d13, d16 │ │ │ │ - vsra.s64 d19, d24, #64 │ │ │ │ + vsra.s64 d19, d16, #64 │ │ │ │ stmiavs fp!, {r1, r8} │ │ │ │ movwpl lr, #2509 @ 0x9cd │ │ │ │ movtvs pc, #53824 @ 0xd240 @ │ │ │ │ - stc 7, cr15, [r6, #952]! @ 0x3b8 │ │ │ │ + stc 7, cr15, [sl, #952]! @ 0x3b8 │ │ │ │ @ instruction: 0xf7fee484 │ │ │ │ strdvs pc, [r0], r3 @ │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ sha1c.32 q13, , │ │ │ │ - vmla.f d21, d16, d0[0] │ │ │ │ + vsra.s64 d21, d24, #64 │ │ │ │ @ instruction: 0xf7ee0102 │ │ │ │ - cmppcs r0, r1, asr #28 @ p-variant is OBSOLETE │ │ │ │ + cmppcs r0, r5, asr #28 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7f52001 │ │ │ │ eorsvs pc, r0, r1, asr fp @ │ │ │ │ mrc2 7, 6, pc, cr4, cr14, {7} │ │ │ │ movwcs r6, #30774 @ 0x7836 │ │ │ │ eorsvs r4, r3, r0, lsr r6 │ │ │ │ stc2l 0, cr15, [lr], {0} │ │ │ │ stccs 8, cr6, [r0, #-660] @ 0xfffffd6c │ │ │ │ stmdavs fp!, {r0, r1, r2, r3, r5, r6, ip, lr, pc} │ │ │ │ suble r2, r0, r2, lsl #22 │ │ │ │ eorle r2, r1, r5, lsl #22 │ │ │ │ - @ instruction: 0x51acf24d │ │ │ │ + @ instruction: 0x51a4f24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee4628 │ │ │ │ - cmppcs r0, r5, lsr #28 @ p-variant is OBSOLETE │ │ │ │ + cmppcs r0, r9, lsr #28 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7f52001 │ │ │ │ eorsvs pc, r0, r5, lsr fp @ │ │ │ │ mrc2 7, 5, pc, cr8, cr14, {7} │ │ │ │ movwcs r6, #26677 @ 0x6835 │ │ │ │ eorvs r4, fp, r8, lsr #12 │ │ │ │ ldc2 0, cr15, [r2] │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - blcs 3c744 <__time64@plt+0x2b45c> │ │ │ │ + blcs 3c73c <__time64@plt+0x2b454> │ │ │ │ @ instruction: 0xf105d136 │ │ │ │ @ instruction: 0xf7ff0014 │ │ │ │ stmiavs r5!, {r0, r3, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ - bllt fe9606e4 │ │ │ │ - asrscs pc, sp, #4 @ │ │ │ │ + bllt fe9606dc │ │ │ │ + @ instruction: 0x21a8f24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee6968 │ │ │ │ - stmdacs r0, {r1, r3, r4, r5, r6, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r3, r4, r5, r6, sl, fp, sp, lr, pc} │ │ │ │ vand , q8, q2 │ │ │ │ vrshr.s64 , q12, #64 │ │ │ │ lslsvs r0, r5, #4 │ │ │ │ - blcs 3c754 <__time64@plt+0x2b46c> │ │ │ │ + blcs 3c74c <__time64@plt+0x2b464> │ │ │ │ @ instruction: 0x4628d13e │ │ │ │ @ instruction: 0xf7ee692d │ │ │ │ - @ instruction: 0xf106ec88 │ │ │ │ + @ instruction: 0xf106ec8c │ │ │ │ adcvs r0, r5, r4, lsl r0 │ │ │ │ - blx ffb60718 │ │ │ │ + blx ffb60710 │ │ │ │ @ instruction: 0xf7ff68a5 │ │ │ │ @ instruction: 0xf105bb87 │ │ │ │ @ instruction: 0xf7f50014 │ │ │ │ vpadd.i8 d31, d0, d19 │ │ │ │ vrsra.s64 , q12, #64 │ │ │ │ lslsvs r0, r5, #6 │ │ │ │ - blcs 3c7a4 <__time64@plt+0x2b4bc> │ │ │ │ + blcs 3c79c <__time64@plt+0x2b4b4> │ │ │ │ stmiavs r0!, {r0, r1, r6, r8, ip, lr, pc} │ │ │ │ eorsle r2, lr, r0, lsl #16 │ │ │ │ @ instruction: 0xf7ee6905 │ │ │ │ - strb lr, [r4, lr, ror #24]! │ │ │ │ + @ instruction: 0xe7e4ec72 │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f5681e │ │ │ │ stmiavs fp!, {r0, r3, r4, r5, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ stmib sp, {r1, r9, sl, lr}^ │ │ │ │ ldrtmi r5, [r0], -r0, lsl #6 │ │ │ │ orrvs pc, r5, #64, 4 │ │ │ │ - msrpl R12_fiq, sp │ │ │ │ + msrpl R12_usr, sp │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldc 7, cr15, [sl, #-952] @ 0xfffffc48 │ │ │ │ + ldc 7, cr15, [lr, #-952] @ 0xfffffc48 │ │ │ │ @ instruction: 0xf7fee7af │ │ │ │ strmi pc, [r5], -r7, ror #28 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ str sp, [sp, r9, lsl #3] │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f5681d │ │ │ │ ldmvs r3!, {r0, r3, r4, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ stmib sp, {r1, r9, sl, lr}^ │ │ │ │ strtmi r6, [r8], -r0, lsl #6 │ │ │ │ orrsvs pc, lr, #64, 4 │ │ │ │ - cmnppl ip, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmnppl r4, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldcl 7, cr15, [sl], #952 @ 0x3b8 │ │ │ │ + ldcl 7, cr15, [lr], #952 @ 0x3b8 │ │ │ │ stccs 8, cr6, [r0, #-660] @ 0xfffffd6c │ │ │ │ @ instruction: 0xf7eed1a5 │ │ │ │ - vadd.f32 , q8, │ │ │ │ + vadd.f32 , q8, │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ vcgt.s8 d16, d13, d5 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ ldmdavs sp, {r1} │ │ │ │ - blx 1f607ac │ │ │ │ + blx 1f607a4 │ │ │ │ @ instruction: 0x460269b3 │ │ │ │ strtmi r9, [r8], -r2, lsl #6 │ │ │ │ - cmpppl r0, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmpppl r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stmib sp, {r0, r1, r4, r5, r7, fp, sp, lr}^ │ │ │ │ vcgt.s8 d22, d0, d0 │ │ │ │ @ instruction: 0xf7ee6396 │ │ │ │ - sbfx lr, ip, #25, #1 │ │ │ │ - cmppcc r0, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + str lr, [r0, r0, ror #25]! │ │ │ │ + teqpcc r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee4628 │ │ │ │ - andcs pc, r0, fp, ror sp @ │ │ │ │ + andcs pc, r0, pc, ror sp @ │ │ │ │ mvnsmi pc, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldc2l 7, cr15, [r4, #-952]! @ 0xfffffc48 │ │ │ │ - bicmi pc, ip, sp, asr #4 │ │ │ │ + ldc2l 7, cr15, [r8, #-952]! @ 0xfffffc48 │ │ │ │ + bicmi pc, r4, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - stc2l 7, cr15, [lr, #-952]! @ 0xfffffc48 │ │ │ │ + ldc2l 7, cr15, [r2, #-952]! @ 0xfffffc48 │ │ │ │ ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ stmiavs r5!, {r0, r1, r2, r9, sl, lr} │ │ │ │ stmdbvs r8!, {r0, r2, r3, r5, r8, r9, ip, sp, pc} │ │ │ │ eorsle r2, r5, r0, lsl #16 │ │ │ │ - blcs fc8e8 │ │ │ │ - blcs 196894 │ │ │ │ + blcs fc8e0 │ │ │ │ + blcs 19688c │ │ │ │ stmdbvs r8!, {r1, r2, r4, r8, ip, lr, pc}^ │ │ │ │ - asrscs pc, sp, #4 @ │ │ │ │ + @ instruction: 0x21a8f24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - bl ff360808 │ │ │ │ + bl ff460800 │ │ │ │ stmdblt r8!, {r1, r2, r9, sl, lr}^ │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ tstphi r3, r0 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7ee6905 │ │ │ │ - adcvs lr, r5, r0, ror #23 │ │ │ │ + adcvs lr, r5, r4, ror #23 │ │ │ │ pop {r1, r2, r3, r4, r5, sp, lr} │ │ │ │ stmdavs r3, {r4, r5, r6, r7, r8, r9, sl, pc} │ │ │ │ eorle r2, r2, r5, lsl #22 │ │ │ │ - msrvc R12_usr, sp │ │ │ │ + tstpvc ip, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee4628 │ │ │ │ - @ instruction: 0xf7fefd3f │ │ │ │ + @ instruction: 0xf7fefd43 │ │ │ │ strmi pc, [r5], -r5, ror #27 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ @ instruction: 0xf7fed1d3 │ │ │ │ @ instruction: 0x4606fddf │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ stmdbvs r3, {r2, r3, r5, r6, r7, ip, lr, pc} │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ ldc2l 7, cr15, [r6, #1016] @ 0x3f8 │ │ │ │ @ instruction: 0xe7e56130 │ │ │ │ ldc2l 7, cr15, [r2, #1016] @ 0x3f8 │ │ │ │ stmdacs r0, {r3, r5, r8, sp, lr} │ │ │ │ stmdavs fp!, {r2, r6, r7, r8, ip, lr, pc} │ │ │ │ sbcle r2, r6, r5, lsl #22 │ │ │ │ vaba.s8 q15, , q6 │ │ │ │ - vorr.i32 q11, #0 @ 0x00000000 │ │ │ │ + vmla.f d22, d0, d0[2] │ │ │ │ stmdbvs r0, {r1, r8}^ │ │ │ │ - bl fe4e087c │ │ │ │ + bl fe5e0874 │ │ │ │ bicsle r2, r3, r0, lsl #16 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ sbcshi pc, r9, r0 │ │ │ │ @ instruction: 0xf7ee6905 │ │ │ │ - adcvs lr, r5, r6, lsr #23 │ │ │ │ + adcvs lr, r5, sl, lsr #23 │ │ │ │ @ instruction: 0xf0002d00 │ │ │ │ stmdbvs lr!, {r1, r4, r6, r7, pc} │ │ │ │ @ instruction: 0xf7ee4628 │ │ │ │ - umlalvs lr, r6, lr, fp │ │ │ │ + adcvs lr, r6, r2, lsr #23 │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ ldmdavs r3!, {r4, r5, r7, r8, pc} │ │ │ │ svclt 0x00082b04 │ │ │ │ stmdbeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ rschi pc, r3, r0 │ │ │ │ stmdaeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ ldmdbvs r0!, {r0, r6, r7, r9, sl, lr} │ │ │ │ eorsle r2, r5, r0, lsl #16 │ │ │ │ - blcs fc9d8 │ │ │ │ + blcs fc9d0 │ │ │ │ stmdavs r3, {r1, r8, ip, lr, pc} │ │ │ │ eorsle r2, r5, r5, lsl #22 │ │ │ │ - msrvs (UNDEF: 100), sp │ │ │ │ + cmppvs ip, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee4630 │ │ │ │ - ldrtmi pc, [r0], -sp, ror #25 @ │ │ │ │ + @ instruction: 0x4630fcf1 │ │ │ │ @ instruction: 0xf7ee6936 │ │ │ │ - movwcs lr, #11132 @ 0x2b7c │ │ │ │ + movwcs lr, #11136 @ 0x2b80 │ │ │ │ andeq pc, ip, r5, lsl #2 │ │ │ │ adcvs r6, r6, fp, lsr #1 │ │ │ │ @ instruction: 0xf9def7ff │ │ │ │ cdpcs 8, 0, cr6, cr0, cr6, {5} │ │ │ │ tstphi r2, r0 @ p-variant is OBSOLETE │ │ │ │ - blcs 13ca10 │ │ │ │ + blcs 13ca08 │ │ │ │ tstphi r5, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ ldmdbvs r6!, {r4, r5, r9, sl, lr} │ │ │ │ - bl 1a60908 │ │ │ │ + bl 1b60900 │ │ │ │ @ instruction: 0xf1b960a6 │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ @ instruction: 0xf8c880ae │ │ │ │ cdpcs 0, 0, cr5, cr0, cr0, {0} │ │ │ │ adcshi pc, r8, r0 │ │ │ │ - blcs 13ca34 │ │ │ │ + blcs 13ca2c │ │ │ │ adchi pc, fp, r0 │ │ │ │ @ instruction: 0x46a86930 │ │ │ │ bicle r2, r9, r0, lsl #16 │ │ │ │ stc2l 7, cr15, [sl, #-1016]! @ 0xfffffc08 │ │ │ │ stmdacs r0, {r4, r5, r8, sp, lr} │ │ │ │ strb sp, [r9, r4, asr #3] │ │ │ │ - cmppvs ip, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppvs r4, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee6940 │ │ │ │ - stmdacs r0, {r1, r2, r3, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r4, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ stmiavs r0!, {r6, r7, r8, ip, lr, pc} │ │ │ │ rsbsle r2, r4, r0, lsl #16 │ │ │ │ @ instruction: 0xf7ee6905 │ │ │ │ - adcvs lr, r5, r2, asr #22 │ │ │ │ + adcvs lr, r5, r6, asr #22 │ │ │ │ rsble r2, lr, r0, lsl #26 │ │ │ │ strtmi r6, [r8], -lr, lsr #18 │ │ │ │ - bl ee0964 │ │ │ │ + bl fe095c │ │ │ │ cdpcs 0, 0, cr6, cr0, cr6, {5} │ │ │ │ rschi pc, r6, r0 │ │ │ │ - blcs 17ca84 │ │ │ │ + blcs 17ca7c │ │ │ │ rschi pc, r9, r0, asr #32 │ │ │ │ andcs r2, r1, r0, lsl r1 │ │ │ │ @ instruction: 0xf9b0f7f5 │ │ │ │ @ instruction: 0x46056833 │ │ │ │ cmple r5, r5, lsl #22 │ │ │ │ - asrscs pc, sp, #4 @ │ │ │ │ + @ instruction: 0x21a8f24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee6970 │ │ │ │ - stmdacs r0, {r3, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r2, r3, r8, r9, fp, sp, lr, pc} │ │ │ │ rsbvs sp, r8, ip, asr #2 │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ stmdbvs r6, {r0, r2, r3, r6, ip, lr, pc} │ │ │ │ - bl 6e09a4 │ │ │ │ + bl 7e099c │ │ │ │ cdpcs 0, 0, cr6, cr0, cr6, {5} │ │ │ │ sbcshi pc, r4, r0 │ │ │ │ - blcs 17cac4 │ │ │ │ + blcs 17cabc │ │ │ │ sbcshi pc, r7, r0, asr #32 │ │ │ │ @ instruction: 0xa014f8d6 │ │ │ │ - teqpvs ip, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpvs r4, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee4650 │ │ │ │ - stmdacs r0, {r1, r2, r3, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r4, r5, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ vqadd.s8 d29, d9, d25 │ │ │ │ - vaddw.s8 q11, q8, d28 │ │ │ │ + vaddw.s8 q11, q8, d20 │ │ │ │ ldrbmi r0, [r0], -r2, lsl #2 │ │ │ │ - b ff9609d8 │ │ │ │ + b ffa609d0 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ vrecps.f32 q13, , q15 │ │ │ │ - vaddw.s8 q11, q8, d16 │ │ │ │ + vsra.s64 d22, d8, #64 │ │ │ │ ldrbmi r0, [r0], -r2, lsl #2 │ │ │ │ - b ff6e09ec │ │ │ │ + b ff7e09e4 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ @ instruction: 0x46308114 │ │ │ │ @ instruction: 0xf7ee6936 │ │ │ │ - strdcs lr, [ip, -r0] │ │ │ │ + strdcs lr, [ip, -r4] │ │ │ │ adcvs r2, r6, r1 │ │ │ │ @ instruction: 0xf96cf7f5 │ │ │ │ rscvs r2, r8, r3, lsl #6 │ │ │ │ @ instruction: 0xf7ff60ab │ │ │ │ stmiavs r6!, {r0, r1, r2, r3, r6, r8, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ ldmdavs r3!, {r0, r3, r4, r5, r7, pc} │ │ │ │ @ instruction: 0xf0002b02 │ │ │ │ - blcs 182db4 │ │ │ │ + blcs 182dac │ │ │ │ vqadd.s8 , , q1 │ │ │ │ - vaddw.s8 q11, q8, d24 │ │ │ │ + vaddw.s8 q11, q8, d16 │ │ │ │ ldrtmi r0, [r0], -r2, lsl #2 │ │ │ │ - mcrr2 7, 14, pc, r2, cr14 @ │ │ │ │ + mcrr2 7, 14, pc, r6, cr14 @ │ │ │ │ ldmdbvs r3!, {r5, r7, fp, sp, lr}^ │ │ │ │ stmdacs r0, {r0, r1, r3, r5, r6, sp, lr} │ │ │ │ @ instruction: 0xf7eed1b1 │ │ │ │ - ldrtmi pc, [r0], -r3, ror #24 @ │ │ │ │ + ldrtmi pc, [r0], -r7, ror #24 @ │ │ │ │ @ instruction: 0xf7ee6936 │ │ │ │ - adcvs lr, r6, sl, asr #21 │ │ │ │ + adcvs lr, r6, lr, asr #21 │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ ldmdavs r3!, {r0, r3, r6, r7, pc} │ │ │ │ adcvs r2, sl, r1, lsl #4 │ │ │ │ @ instruction: 0xf0002b02 │ │ │ │ - blcs 182dd8 │ │ │ │ + blcs 182dd0 │ │ │ │ addhi pc, r8, r0 │ │ │ │ - orrvs pc, r0, sp, asr #4 │ │ │ │ + cmnpvs r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee4630 │ │ │ │ - msrlt SPSR_sx, r3, lsr #24 │ │ │ │ + msrlt SPSR_sx, r7, lsr #24 │ │ │ │ @ instruction: 0x46a96833 │ │ │ │ @ instruction: 0xf47f2b04 │ │ │ │ ldmdbvs r5!, {r0, r2, r4, r6, r8, r9, sl, fp, sp, pc} │ │ │ │ @ instruction: 0xf7ee4630 │ │ │ │ - adcvs lr, r5, ip, lsr #21 │ │ │ │ + strhtvs lr, [r5], r0 │ │ │ │ andls pc, r0, r7, asr #17 │ │ │ │ strtmi lr, [r9], r9, asr #13 │ │ │ │ ldc2 7, cr15, [sl], #1016 @ 0x3f8 │ │ │ │ adcvs r4, r0, r6, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ strtmi sl, [r8], r1, asr #30 │ │ │ │ ldc2 7, cr15, [r2], #1016 @ 0x3f8 │ │ │ │ adcvs r4, r0, r6, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7feaf08 │ │ │ │ strmi pc, [r5], -fp, lsr #25 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ svcge 0x000af43f │ │ │ │ - blcs 3cf10 <__time64@plt+0x2bc28> │ │ │ │ + blcs 3cf08 <__time64@plt+0x2bc20> │ │ │ │ svcge 0x0006f47f │ │ │ │ stc2 7, cr15, [r0], #1016 @ 0x3f8 │ │ │ │ str r6, [r1, -r8, lsr #2] │ │ │ │ - asrscs pc, sp, #4 @ │ │ │ │ + @ instruction: 0x21a8f24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee6970 │ │ │ │ - stmdacs r0, {r1, r2, r5, r6, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r3, r5, r6, r9, fp, sp, lr, pc} │ │ │ │ stmiavs fp!, {r0, r1, r5, r7, r8, ip, lr, pc}^ │ │ │ │ @ instruction: 0x46306098 │ │ │ │ @ instruction: 0xf7ee6936 │ │ │ │ - adcvs lr, r6, sl, ror sl │ │ │ │ + adcvs lr, r6, lr, ror sl │ │ │ │ subsle r2, r5, r0, lsl #28 │ │ │ │ - blcs bcc04 │ │ │ │ - blcs 196ca0 │ │ │ │ + blcs bcbfc │ │ │ │ + blcs 196c98 │ │ │ │ vand d29, d29, d5 │ │ │ │ - vsra.s64 d18, d16, #64 │ │ │ │ + vaddw.s8 q9, q8, d24 │ │ │ │ ldmdbvs r0!, {r1, r8}^ │ │ │ │ - b 13e0b04 │ │ │ │ + b 14e0afc │ │ │ │ orrle r2, ip, r0, lsl #16 │ │ │ │ subsvs r6, r8, fp, ror #17 │ │ │ │ ldmdbvs r6!, {r4, r5, r9, sl, lr} │ │ │ │ - b 18e0b14 │ │ │ │ + b 19e0b0c │ │ │ │ cdpcs 0, 0, cr6, cr0, cr6, {5} │ │ │ │ mcrge 4, 7, pc, cr14, cr15, {3} @ │ │ │ │ ldc2l 7, cr15, [r2], #-1016 @ 0xfffffc08 │ │ │ │ adcvs r4, r0, r6, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ vceq.f32 q13, , │ │ │ │ - vsra.s64 q11, q4, #64 │ │ │ │ + vsra.s64 q11, q0, #64 │ │ │ │ ldrtmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx fefe0b3a │ │ │ │ + blx ff0e0b32 │ │ │ │ stc2l 7, cr15, [r4], #-1016 @ 0xfffffc08 │ │ │ │ adcvs r4, r0, r6, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ vrecps.f32 d26, d13, d3 │ │ │ │ - vorr.i32 d23, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 , q0, d8 │ │ │ │ ldrtmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx fec60b56 │ │ │ │ + blx fed60b4e │ │ │ │ mrrc2 7, 15, pc, r6, cr14 @ │ │ │ │ adcvs r4, r0, r6, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ vmax.f32 d26, d13, d21 │ │ │ │ - vsra.s64 q11, q14, #64 │ │ │ │ + vsra.s64 q11, q10, #64 │ │ │ │ ldrtmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx fe8e0b72 │ │ │ │ - asrscs pc, sp, #4 @ │ │ │ │ + blx fe9e0b6a │ │ │ │ + @ instruction: 0x21a8f24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee6970 │ │ │ │ - stmdacs r0, {r1, r4, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r4, r9, fp, sp, lr, pc} │ │ │ │ svcge 0x006ef47f │ │ │ │ strb r6, [r1, r8, ror #1] │ │ │ │ ldc2 7, cr15, [ip], #-1016 @ 0xfffffc08 │ │ │ │ adcvs r4, r0, r6, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ strb sl, [r4, -r0, asr #30] │ │ │ │ ldc2 7, cr15, [r4], #-1016 @ 0xfffffc08 │ │ │ │ @@ -17985,23 +17983,23 @@ │ │ │ │ @ instruction: 0xd1a32800 │ │ │ │ @ instruction: 0xf106e73d │ │ │ │ stmiavs lr!, {r2, r4}^ │ │ │ │ @ instruction: 0xf8ccf7f5 │ │ │ │ stmiavs r0!, {r4, r5, r6, sp, lr} │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ stmdbvs r6, {r6, r8, r9, sl, fp, sp, pc} │ │ │ │ - b 360bc0 │ │ │ │ + b 460bb8 │ │ │ │ ldr r6, [r6], r6, lsr #1 │ │ │ │ andseq pc, r4, r6, lsl #2 │ │ │ │ @ instruction: 0xf7f568ee │ │ │ │ ldrhtvs pc, [r0], sp @ │ │ │ │ stmdacs r0, {r5, r7, fp, sp, lr} │ │ │ │ svcge 0x0031f43f │ │ │ │ @ instruction: 0xf7ee6906 │ │ │ │ - @ instruction: 0xe782e9fe │ │ │ │ + str lr, [r2, r2, lsl #20] │ │ │ │ ldc2 7, cr15, [r0], {254} @ 0xfe │ │ │ │ adcvs r4, r0, r6, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ movwcs sl, #7984 @ 0x1f30 │ │ │ │ ldr r6, [r5, -fp, lsr #1]! │ │ │ │ andseq pc, r4, r6, lsl #2 │ │ │ │ @ instruction: 0xf8a6f7f5 │ │ │ │ @@ -18009,397 +18007,397 @@ │ │ │ │ bicsle r2, sl, r0, lsl #16 │ │ │ │ @ instruction: 0xf7fee719 │ │ │ │ @ instruction: 0x4606fbfd │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ mcrge 4, 2, pc, cr9, cr15, {3} @ │ │ │ │ strmi r4, [r1], r0, lsl #13 │ │ │ │ vabd.s8 q15, , q0 │ │ │ │ - vmla.f d22, d16, d0[2] │ │ │ │ + vmla.f d22, d16, d0[0] │ │ │ │ ldrtmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx 11e0c2a │ │ │ │ + blx 12e0c22 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ ldrvc pc, [r0, #-576]! @ 0xfffffdc0 │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ strmi fp, [r0], r5, lsl #1 │ │ │ │ stccs 8, cr6, [r0], {172} @ 0xac │ │ │ │ sbcshi pc, r5, r0 │ │ │ │ vabd.s8 d18, d13, d0 │ │ │ │ - @ instruction: 0xf2c029b0 │ │ │ │ + vqdmlal.s q9, d16, d24 │ │ │ │ ldrtmi r0, [lr], -r2, lsl #18 │ │ │ │ stmdavs r3!, {r1, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ eorle r2, fp, r4, lsl #22 │ │ │ │ stccs 8, cr6, [r0], {172} @ 0xac │ │ │ │ addshi pc, r6, r0 │ │ │ │ cmplt r8, #32, 18 @ 0x80000 │ │ │ │ - blcs fcd38 │ │ │ │ + blcs fcd30 │ │ │ │ @ instruction: 0xf8d5d030 │ │ │ │ - blcs 18ecd4 │ │ │ │ + blcs 18eccc │ │ │ │ adchi pc, r7, r0, asr #32 │ │ │ │ strbmi r6, [r9], -r0, ror #18 │ │ │ │ - ldmib r4, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib r8, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ @ instruction: 0xf1bb80a0 │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ @ instruction: 0xf8db80b0 │ │ │ │ @ instruction: 0x46584010 │ │ │ │ - stmib r4!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - bleq 5ee18 │ │ │ │ + stmib r8!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + bleq 5ee10 │ │ │ │ svccs 0x000060ac │ │ │ │ @ instruction: 0xf8cad068 │ │ │ │ stccs 0, cr11, [r0], {-0} │ │ │ │ stmdavs r3!, {r0, r3, r5, r6, ip, lr, pc} │ │ │ │ ldrbmi r3, [sl], r1, lsl #12 │ │ │ │ bicsle r2, r3, r4, lsl #22 │ │ │ │ @ instruction: 0xf8c84630 │ │ │ │ andlt r7, r5, r0 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ - blx fe960cfe │ │ │ │ + blx fe960cf6 │ │ │ │ @ instruction: 0x61206823 │ │ │ │ sbcsle r2, r0, r0, lsl #16 │ │ │ │ bicle r2, lr, r3, lsl #22 │ │ │ │ - blcs 17cd20 │ │ │ │ + blcs 17cd18 │ │ │ │ vand , , │ │ │ │ - vbic.i32 d23, #8 @ 0x00000008 │ │ │ │ + vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ stmdbvs r0, {r1, r8}^ │ │ │ │ - stmdb r2!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb r6!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ cmnle ip, r0, lsl #16 │ │ │ │ andcs r2, r1, r8, lsl r1 │ │ │ │ @ instruction: 0xfffaf7f4 │ │ │ │ stmiavs r8!, {r0, r1, r7, r9, sl, lr} │ │ │ │ rsbsle r2, sl, r0, lsl #16 │ │ │ │ @ instruction: 0xf7ee6904 │ │ │ │ - adcvs lr, ip, r2, ror r9 │ │ │ │ + adcvs lr, ip, r6, ror r9 │ │ │ │ rsbsle r2, r4, r0, lsl #24 │ │ │ │ stmdbvs r4!, {r5, r9, sl, lr} │ │ │ │ - stmdb sl!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb lr!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stccs 0, cr6, [r0], {172} @ 0xac │ │ │ │ addhi pc, r4, r0 │ │ │ │ - bcs bcde0 │ │ │ │ + bcs bcdd8 │ │ │ │ addhi pc, r7, r0, asr #32 │ │ │ │ tstpeq r4, #4, 2 @ p-variant is OBSOLETE │ │ │ │ - asrscs pc, sp, #4 @ │ │ │ │ + @ instruction: 0x21a8f24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ movwls r4, #13848 @ 0x3618 │ │ │ │ - ldmdb ip!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r0, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ cmple r4, r0, lsl #16 │ │ │ │ andeq pc, r4, fp, asr #17 │ │ │ │ stmdbvs r4!, {r5, r9, sl, lr} │ │ │ │ - ldmdb r0, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdb r4, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ andeq pc, r8, fp, lsl #2 │ │ │ │ @ instruction: 0xf7fe60ac │ │ │ │ @ instruction: 0xf10bffb5 │ │ │ │ @ instruction: 0xf7fe000c │ │ │ │ @ instruction: 0xf10bfea5 │ │ │ │ @ instruction: 0xf7ff0014 │ │ │ │ stmiavs r8!, {r0, r1, r6, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ subsle r2, r2, r0, lsl #16 │ │ │ │ - blcs 13cdb0 │ │ │ │ + blcs 13cda8 │ │ │ │ stmdbvs r4, {r2, r4, r6, r8, ip, lr, pc} │ │ │ │ - ldmdb sl!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmdb lr!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ svccs 0x000060ac │ │ │ │ @ instruction: 0x465fd197 │ │ │ │ @ instruction: 0x3601b114 │ │ │ │ @ instruction: 0xe76c46ba │ │ │ │ @ instruction: 0xf7fe46bb │ │ │ │ strcc pc, [r1], -r5, asr #22 │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ addsle r2, r3, r0, lsl #16 │ │ │ │ @ instruction: 0xe76246da │ │ │ │ - blx f60dce │ │ │ │ + blx f60dc6 │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7feaf63 │ │ │ │ @ instruction: 0x4604fb35 │ │ │ │ tstlt r8, r8, lsr #1 │ │ │ │ - blcs 3d1f8 <__time64@plt+0x2bf10> │ │ │ │ + blcs 3d1f0 <__time64@plt+0x2bf08> │ │ │ │ stmiavs ip!, {r2, r6, ip, lr, pc} │ │ │ │ - adcvc pc, ip, sp, asr #4 │ │ │ │ + adcvc pc, r4, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldmib r5, {r0, r1, r5, fp, sp, lr}^ │ │ │ │ @ instruction: 0xf7ee2100 │ │ │ │ - @ instruction: 0xf8d5fb0b │ │ │ │ + @ instruction: 0xf8d5fb0f │ │ │ │ @ instruction: 0xf8dbb008 │ │ │ │ vhadd.s8 d19, d13, d0 │ │ │ │ - vmla.i d23, d0, d0[7] │ │ │ │ + vmla.i d23, d0, d0[5] │ │ │ │ movwls r0, #2 │ │ │ │ movwcs lr, #6612 @ 0x19d4 │ │ │ │ @ instruction: 0xf7ee68e1 │ │ │ │ - stmdals r3, {r0, r2, r3, r4, r5, r6, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ + stmdals r3, {r0, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xffb6f7f4 │ │ │ │ @ instruction: 0xf8cb68ac │ │ │ │ stccs 0, cr0, [r0], {4} │ │ │ │ @ instruction: 0xf7eed1a4 │ │ │ │ - @ instruction: 0xf7fefa8d │ │ │ │ + @ instruction: 0xf7fefa91 │ │ │ │ strmi pc, [r4], -fp, lsl #22 │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ svcge 0x0024f47f │ │ │ │ strmi r4, [r6], -r7, lsl #12 │ │ │ │ @ instruction: 0xf7fee756 │ │ │ │ adcvs pc, r8, r1, lsl #22 │ │ │ │ @ instruction: 0xd1a72800 │ │ │ │ - cmppvc r0, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqpvc r8, sp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx 1460e14 │ │ │ │ - blx ffde0e58 │ │ │ │ + blx 1560e0c │ │ │ │ + blx ffde0e50 │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ vrecps.f32 q13, , │ │ │ │ - vorr.i32 , #8 @ 0x00000008 │ │ │ │ + vorr.i32 , #0 @ 0x00000000 │ │ │ │ strtmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx 10e0e30 │ │ │ │ - blx ffa60e74 │ │ │ │ + blx 11e0e28 │ │ │ │ + blx ffa60e6c │ │ │ │ ldr r6, [r6, r0, lsr #2]! │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ ldrvc pc, [r0, #-576]! @ 0xfffffdc0 │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ movwcs fp, #134 @ 0x86 │ │ │ │ stmiavs ip!, {r0, r1, r2, r9, sl, lr} │ │ │ │ stccs 3, cr9, [r0], {5} │ │ │ │ stmdbvs r6!, {r0, r4, r5, ip, lr, pc} │ │ │ │ suble r2, fp, r0, lsl #28 │ │ │ │ @ instruction: 0xf1066932 │ │ │ │ - bcs 24ee8 <__time64@plt+0x13c00> │ │ │ │ - blx fedd7018 │ │ │ │ + bcs 24ee0 <__time64@plt+0x13bf8> │ │ │ │ + blx fedd7010 │ │ │ │ stmdavs r1!, {r1, r2, r7, r8, r9, ip, sp, lr, pc} │ │ │ │ stmdbcs r3, {r0, r1, r3, r4, r6, r8, fp} │ │ │ │ @ instruction: 0xf043bf18 │ │ │ │ @ instruction: 0xb1230301 │ │ │ │ eorsvs r2, fp, r0, lsl #6 │ │ │ │ pop {r1, r2, ip, sp, pc} │ │ │ │ ldmdavs r3!, {r4, r5, r6, r7, r8, pc} │ │ │ │ - blcs 1876d8 │ │ │ │ + blcs 1876d0 │ │ │ │ ldmdbvs r0!, {r1, r4, r8, ip, lr, pc}^ │ │ │ │ mvnvc pc, sp, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - stm r6, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blx fecc96ec │ │ │ │ + stm sl, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blx fecc96e4 │ │ │ │ ldmdbeq fp, {r1, r7, r8, r9, ip, sp, lr, pc}^ │ │ │ │ svclt 0x00182800 │ │ │ │ movweq pc, #4163 @ 0x1043 @ │ │ │ │ ldmdavs r3, {r0, r1, r4, r8, fp, ip, sp, pc} │ │ │ │ subsle r2, r1, r1, lsl #22 │ │ │ │ eorsvs r9, fp, r5, lsl #22 │ │ │ │ pop {r1, r2, ip, sp, pc} │ │ │ │ @ instruction: 0xf7fe81f0 │ │ │ │ strmi pc, [r4], -r5, lsr #21 │ │ │ │ teqlt r8, r8, lsr #1 │ │ │ │ @ instruction: 0xb1ae6906 │ │ │ │ @ instruction: 0xf1066932 │ │ │ │ - bcs 24f54 <__time64@plt+0x13c6c> │ │ │ │ + bcs 24f4c <__time64@plt+0x13c64> │ │ │ │ eor sp, r4, r9, asr #3 │ │ │ │ - blx fe660f14 │ │ │ │ + blx fe660f0c │ │ │ │ adcvs r4, r8, r0, lsl #13 │ │ │ │ subsle r2, r7, r0, lsl #16 │ │ │ │ cmplt r4, r4, lsl #18 │ │ │ │ - blcs 3d3b8 <__time64@plt+0x2c0d0> │ │ │ │ + blcs 3d3b0 <__time64@plt+0x2c0c8> │ │ │ │ @ instruction: 0xf104d1e2 │ │ │ │ @ instruction: 0x46260810 │ │ │ │ ands r4, r4, ip, lsl r6 │ │ │ │ @ instruction: 0xf7fe46a0 │ │ │ │ stmiavs sl!, {r0, r1, r2, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf8c84606 │ │ │ │ ldmiblt sl!, {r4} │ │ │ │ - blx fe060f44 │ │ │ │ + blx fe060f3c │ │ │ │ cmnlt r8, r8, lsr #1 │ │ │ │ mvnslt r6, r3, lsl #18 │ │ │ │ tstlt r2, sl, lsl r9 │ │ │ │ sbcle r2, fp, r0, lsl #24 │ │ │ │ @ instruction: 0xf103e7a5 │ │ │ │ @ instruction: 0xf7fe0810 │ │ │ │ @ instruction: 0x4602fa73 │ │ │ │ andeq pc, r0, r8, asr #17 │ │ │ │ mvnsle r2, r0, lsl #16 │ │ │ │ stccs 2, cr2, [r0], {-0} │ │ │ │ @ instruction: 0xe798d0be │ │ │ │ @ instruction: 0xf1026913 │ │ │ │ - blcs 24fc0 <__time64@plt+0x13cd8> │ │ │ │ + blcs 24fb8 <__time64@plt+0x13cd0> │ │ │ │ @ instruction: 0xf7fed1e8 │ │ │ │ strmi pc, [r3], -r3, ror #20 │ │ │ │ andeq pc, r0, r8, asr #17 │ │ │ │ mvnle r2, r0, lsl #16 │ │ │ │ @ instruction: 0xf100e7ee │ │ │ │ @ instruction: 0xe7f40810 │ │ │ │ @ instruction: 0x8014f8d2 │ │ │ │ stmiavs r8!, {r0, r1, r9, sl, sp} │ │ │ │ stmdbvs r4, {r4, r5, r6, r8, r9, ip, sp, pc} │ │ │ │ - ldmda ip!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda r0, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ adcvs r3, ip, r1, lsl #28 │ │ │ │ strtmi sp, [r0], -r1 │ │ │ │ stmdage r5, {r1, r2, r4, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ mrc2 7, 2, pc, cr12, cr15, {7} │ │ │ │ strmi r6, [r6], -ip, lsr #17 │ │ │ │ ldrmi fp, [r0, #396]! @ 0x18c │ │ │ │ stmdavs r3!, {r0, r1, r3, r5, r8, ip, lr, pc} │ │ │ │ tstle r4, r4, lsl #22 │ │ │ │ stmdbvs r4, {r3, r5, r7, fp, sp, lr} │ │ │ │ - stmda r8!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda ip!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ str r6, [pc, ip, lsr #1] │ │ │ │ - blx ee0fd0 │ │ │ │ + blx ee0fc8 │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ strtmi sp, [r6], -sl, lsl #1 │ │ │ │ @ instruction: 0xf7fee7b6 │ │ │ │ @ instruction: 0x4604fa33 │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ ldrmi sp, [r0, #487]! @ 0x1e7 │ │ │ │ @ instruction: 0xf64dd108 │ │ │ │ - vaddw.s8 q8, q8, d4 │ │ │ │ + vbic.i32 q8, #12 @ 0x0000000c │ │ │ │ strtmi r0, [r0], -r2, lsl #2 │ │ │ │ - @ instruction: 0xf97ef7ee │ │ │ │ - @ instruction: 0xf9a4f7ee │ │ │ │ + @ instruction: 0xf982f7ee │ │ │ │ + @ instruction: 0xf9a8f7ee │ │ │ │ ldrdcs lr, [r0, -r5] │ │ │ │ - eorseq pc, ip, sp, asr #12 │ │ │ │ + eorseq pc, r4, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf8cd4633 │ │ │ │ @ instruction: 0xf7ee8000 │ │ │ │ - stmib sp, {r0, r1, r2, r3, r4, r5, r6, r7, r8, fp, ip, sp, lr, pc}^ │ │ │ │ + stmib sp, {r0, r1, r9, fp, ip, sp, lr, pc}^ │ │ │ │ vadd.i8 d22, d13, d0 │ │ │ │ - vshr.s64 , q8, #64 │ │ │ │ + vmla.i d23, d16, d0[6] │ │ │ │ ldmib r4, {r1}^ │ │ │ │ stmiavs r1!, {r0, r8, r9, sp}^ │ │ │ │ - @ instruction: 0xf9f4f7ee │ │ │ │ + @ instruction: 0xf9f8f7ee │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ strmi fp, [r5], -r2, lsl #1 │ │ │ │ stmdbcs r0, {r0, r5, r7, fp, sp, lr} │ │ │ │ stmdavs pc, {r0, r1, r3, r6, ip, lr, pc} @ │ │ │ │ cmnle pc, r1, lsl #30 │ │ │ │ strmi r6, [r8], -fp, asr #18 │ │ │ │ stmdbvs lr, {r0, r1, r3, r5, r7, sp, lr} │ │ │ │ - svc 0x00e4f7ed │ │ │ │ + svc 0x00e8f7ed │ │ │ │ ldrtmi r6, [sl], -r0, lsr #19 │ │ │ │ adcvs r4, r6, r9, lsr #12 │ │ │ │ mcrr2 7, 15, pc, r8, cr4 @ │ │ │ │ stmdacs r0, {r0, r1, r9, sl, lr} │ │ │ │ @ instruction: 0xf105d06b │ │ │ │ andsvs r0, sp, ip │ │ │ │ mcr2 7, 2, pc, cr0, cr14, {7} @ │ │ │ │ cdpcs 8, 0, cr6, cr0, cr6, {5} │ │ │ │ ldmdavs r3!, {r6, ip, lr, pc} │ │ │ │ cmple r3, r5, lsl #22 │ │ │ │ @ instruction: 0x8014f8d6 │ │ │ │ - @ instruction: 0x01a8f64d │ │ │ │ + asreq pc, sp, #12 @ │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ed4640 │ │ │ │ - strmi lr, [r3], -ip, lsr #31 │ │ │ │ + @ instruction: 0x4603efb0 │ │ │ │ @ instruction: 0xf64db180 │ │ │ │ - vmla.f d18, d0, d0[1] │ │ │ │ + vbic.i32 d18, #12 @ 0x0000000c │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - svc 0x00a2f7ed │ │ │ │ + svc 0x00a6f7ed │ │ │ │ smlawbvs pc, r8, r9, fp @ │ │ │ │ ldmdbvs r5!, {r4, r5, r9, sl, lr} │ │ │ │ - svc 0x00b8f7ed │ │ │ │ + svc 0x00bcf7ed │ │ │ │ andlt r6, r2, r5, lsr #1 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ ldrtmi r6, [r0], -fp, lsr #2 │ │ │ │ @ instruction: 0xf7ed6935 │ │ │ │ - strhtvs lr, [r5], r0 │ │ │ │ + strhtvs lr, [r5], r4 │ │ │ │ pop {r1, ip, sp, pc} │ │ │ │ @ instruction: 0xf64d81f0 │ │ │ │ - vbic.i32 , #0 @ 0x00000000 │ │ │ │ + vmla.f d17, d0, d0[6] │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - svc 0x0088f7ed │ │ │ │ + svc 0x008cf7ed │ │ │ │ strcs fp, [r2, -r8, ror #19] │ │ │ │ @ instruction: 0xf7fee7e3 │ │ │ │ @ instruction: 0x4601f9b5 │ │ │ │ stmdacs r0, {r5, r7, sp, lr} │ │ │ │ ldmib r4, {r0, r2, r3, r5, r7, r8, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf64d3100 │ │ │ │ - vmov.i32 d17, #8 @ 0x00000008 │ │ │ │ + vmov.i32 d17, #0 @ 0x00000000 │ │ │ │ ldrmi r0, [sl], -r2 │ │ │ │ - @ instruction: 0xf98ef7ee │ │ │ │ + @ instruction: 0xf992f7ee │ │ │ │ @ instruction: 0xf9a6f7fe │ │ │ │ adcvs r4, r0, r6, lsl #12 │ │ │ │ @ instruction: 0xd1b82800 │ │ │ │ - @ instruction: 0x01b4f64d │ │ │ │ + @ instruction: 0x01acf64d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee4630 │ │ │ │ - @ instruction: 0x4640f8f3 │ │ │ │ - msrne (UNDEF: 96), sp │ │ │ │ + @ instruction: 0x4640f8f7 │ │ │ │ + cmppne r8, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ed2703 │ │ │ │ - stmdacs r0, {r1, r5, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r5, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xe7edd0bd │ │ │ │ @ instruction: 0xf64d6823 │ │ │ │ - vshr.s64 q8, q0, #64 │ │ │ │ + vmla.i d16, d16, d0[2] │ │ │ │ movwls r0, #2 │ │ │ │ movwcs lr, #6609 @ 0x19d1 │ │ │ │ @ instruction: 0xf7ee68c9 │ │ │ │ - @ instruction: 0xf64df96b │ │ │ │ - vrshr.s64 d16, d12, #64 │ │ │ │ + @ instruction: 0xf64df96f │ │ │ │ + vrshr.s64 d16, d4, #64 │ │ │ │ vhsub.s8 d16, d13, d2 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7ee5197 │ │ │ │ - svclt 0x0000f9b7 │ │ │ │ + svclt 0x0000f9bb │ │ │ │ stmib r0, {r9, sp}^ │ │ │ │ ldrbmi r2, [r0, -r0, lsl #4]! │ │ │ │ tstlt r3, r3, asr #16 │ │ │ │ vaba.s8 q10, q0, q8 │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ ldrlt r0, [r0, #-773] @ 0xfffffcfb │ │ │ │ andcs r4, sl, r4, lsl #12 │ │ │ │ @ instruction: 0xf7ee68d9 │ │ │ │ - movwcs lr, #6266 @ 0x187a │ │ │ │ + movwcs lr, #6270 @ 0x187e │ │ │ │ ldclt 0, cr6, [r0, #-396] @ 0xfffffe74 │ │ │ │ @ instruction: 0x4605b5f8 │ │ │ │ - blcs 3d298 <__time64@plt+0x2bfb0> │ │ │ │ + blcs 3d290 <__time64@plt+0x2bfa8> │ │ │ │ stmdavs r7, {r0, r1, r2, r3, r4, r6, ip, lr, pc} │ │ │ │ svccs 0x00001a7f │ │ │ │ vmla.f32 , q0, │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strcs r0, [r0], -r5, lsl #8 │ │ │ │ movweq pc, #28695 @ 0x7017 @ │ │ │ │ - blcs 97268 │ │ │ │ - blcs d7248 │ │ │ │ - blcs 117230 │ │ │ │ - blcs 157218 │ │ │ │ - blcs 197200 │ │ │ │ - blcs 1d71e8 │ │ │ │ + blcs 97260 │ │ │ │ + blcs d7240 │ │ │ │ + blcs 117228 │ │ │ │ + blcs 157210 │ │ │ │ + blcs 1971f8 │ │ │ │ + blcs 1d71e0 │ │ │ │ strcs sp, [r1], -r4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmda r4, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r8, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ee2020 │ │ │ │ - @ instruction: 0x3601e850 │ │ │ │ + @ instruction: 0x3601e854 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmda sl, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda lr, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ee2020 │ │ │ │ - strcc lr, [r1], -r6, asr #16 │ │ │ │ + strcc lr, [r1], -sl, asr #16 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmda r0, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda r4, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ee2020 │ │ │ │ - stmiavs r1!, {r2, r3, r4, r5, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r6, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1], -r0, lsr #32 │ │ │ │ - ldmda r6!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda sl!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ strhtle r4, [r2], -r7 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmda r0!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda r4!, {r1, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ee3608 │ │ │ │ + stmiavs r1!, {r4, r5, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ee2020 │ │ │ │ stmiavs r1!, {r2, r3, r5, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ee2020 │ │ │ │ stmiavs r1!, {r3, r5, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ee2020 │ │ │ │ stmiavs r1!, {r2, r5, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ee2020 │ │ │ │ stmiavs r1!, {r5, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ee2020 │ │ │ │ stmiavs r1!, {r2, r3, r4, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ee2020 │ │ │ │ - stmiavs r1!, {r3, r4, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7ee2020 │ │ │ │ - adcsmi lr, r7, #20, 16 @ 0x140000 │ │ │ │ + adcsmi lr, r7, #24, 16 @ 0x180000 │ │ │ │ movwcs sp, #476 @ 0x1dc │ │ │ │ ldcllt 0, cr6, [r8, #428]! @ 0x1ac │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x460541f0 │ │ │ │ - blcs 34a9c <__time64@plt+0x237b4> │ │ │ │ + blcs 34a94 <__time64@plt+0x237ac> │ │ │ │ @ instruction: 0xf8d0d06f │ │ │ │ vhadd.s8 d24, d0, d0 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf1b80405 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf0182600 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -18407,60 +18405,60 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], -sl, ror #31 │ │ │ │ + strcc lr, [r1], -lr, ror #31 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x00e4f7ed │ │ │ │ + svc 0x00e8f7ed │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], -r0, ror #31 │ │ │ │ + strcc lr, [r1], -r4, ror #31 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x00daf7ed │ │ │ │ + svc 0x00def7ed │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - @ instruction: 0x3601efd6 │ │ │ │ + @ instruction: 0x3601efda │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x00d0f7ed │ │ │ │ + svc 0x00d4f7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed3601 │ │ │ │ - ldrmi lr, [r0, #4044]! @ 0xfcc │ │ │ │ + ldrmi lr, [r0, #4048]! @ 0xfd0 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r1, r2, r6, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r3, r6, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], -r0, lsr #32 │ │ │ │ + svc 0x00c4f7ed │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x00c0f7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x00bcf7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x00b8f7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x00b4f7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x00b0f7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x00acf7ed │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x00a8f7ed │ │ │ │ ldrhle r4, [ip, #80] @ 0x50 │ │ │ │ stmiavs r0!, {r8, r9, sp}^ │ │ │ │ ldrtmi r6, [sl], -fp, rrx │ │ │ │ - orrne pc, r4, sp, asr #12 │ │ │ │ + cmnpne ip, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - svc 0x003af7ed │ │ │ │ + svc 0x003ef7ed │ │ │ │ movwcc r6, #6187 @ 0x182b │ │ │ │ pop {r0, r1, r3, r5, sp, lr} │ │ │ │ vand q12, q8, q8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ andcs r0, sl, r5, lsl #8 │ │ │ │ @ instruction: 0xf7ed68e1 │ │ │ │ - @ instruction: 0xf8d5ef90 │ │ │ │ + @ instruction: 0xf8d5ef94 │ │ │ │ movwcs r8, #4096 @ 0x1000 │ │ │ │ @ instruction: 0xf1b8606b │ │ │ │ stcle 15, cr0, [r9], {0} │ │ │ │ svclt 0x0000e7e0 │ │ │ │ vqrshl.s8 , q12, q8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ ldmib r0, {r0, r2, sl}^ │ │ │ │ @@ -18474,268 +18472,268 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1, -r4, ror #30] │ │ │ │ + strcc lr, [r1, -r8, ror #30] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x005ef7ed │ │ │ │ + svc 0x0062f7ed │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - smlsdcc r1, sl, pc, lr @ │ │ │ │ + smlsdcc r1, lr, pc, lr @ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x0054f7ed │ │ │ │ + svc 0x0058f7ed │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - smlsdcc r1, r0, pc, lr @ │ │ │ │ + smlsdcc r1, r4, pc, lr @ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x004af7ed │ │ │ │ + svc 0x004ef7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed3701 │ │ │ │ - adcsmi lr, lr, #280 @ 0x118 │ │ │ │ + adcsmi lr, lr, #296 @ 0x128 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r6, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r2, r6, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + svc 0x003ef7ed │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x003af7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x0036f7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x0032f7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x002ef7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x002af7ed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ svc 0x0026f7ed │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x0022f7ed │ │ │ │ ldrhle r4, [ip, #46] @ 0x2e │ │ │ │ stmiavs r1!, {r8, r9, sp}^ │ │ │ │ eorcs r6, r9, fp, rrx │ │ │ │ - svc 0x001af7ed │ │ │ │ + svc 0x001ef7ed │ │ │ │ tstlt r3, fp, ror #16 │ │ │ │ stmiavs r1!, {r3, r4, r5, r6, r7, r8, sl, fp, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7ed200a │ │ │ │ - movwcs lr, #7956 @ 0x1f14 │ │ │ │ + movwcs lr, #7960 @ 0x1f18 │ │ │ │ ldcllt 0, cr6, [r8, #428]! @ 0x1ac │ │ │ │ stmib r0, {r9, sp}^ │ │ │ │ addvs r2, r2, r0, lsl #4 │ │ │ │ svclt 0x00004770 │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x460641f0 │ │ │ │ - blcs 34c98 <__time64@plt+0x239b0> │ │ │ │ + blcs 34c90 <__time64@plt+0x239a8> │ │ │ │ stmdavs r3, {r1, r5, r6, ip, lr, pc} │ │ │ │ ldmcc pc!, {r0, r1, r8, ip, sp, lr, pc}^ @ │ │ │ │ svceq 0x0000f1b8 │ │ │ │ vmla.f32 , q0, q6 │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ strcs r0, [r0, -r5, lsl #10] │ │ │ │ movweq pc, #28696 @ 0x7018 @ │ │ │ │ - blcs 97548 │ │ │ │ - blcs d7528 │ │ │ │ - blcs 117510 │ │ │ │ - blcs 1574f8 │ │ │ │ - blcs 1974e0 │ │ │ │ - blcs 1d74c8 │ │ │ │ + blcs 97540 │ │ │ │ + blcs d7520 │ │ │ │ + blcs 117508 │ │ │ │ + blcs 1574f0 │ │ │ │ + blcs 1974d8 │ │ │ │ + blcs 1d74c0 │ │ │ │ strcs sp, [r1, -r4] │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - cdp 7, 14, cr15, cr4, cr13, {7} │ │ │ │ + cdp 7, 14, cr15, cr8, cr13, {7} │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1, -r0, ror #29] │ │ │ │ + strcc lr, [r1, -r4, ror #29] │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - cdp 7, 13, cr15, cr10, cr13, {7} │ │ │ │ + cdp 7, 13, cr15, cr14, cr13, {7} │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - @ instruction: 0x3701eed6 │ │ │ │ + @ instruction: 0x3701eeda │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - cdp 7, 13, cr15, cr0, cr13, {7} │ │ │ │ + cdp 7, 13, cr15, cr4, cr13, {7} │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r9!, {r2, r3, r6, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r9!, {r4, r6, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1, -r0, lsr #32] │ │ │ │ - cdp 7, 12, cr15, cr6, cr13, {7} │ │ │ │ + cdp 7, 12, cr15, cr10, cr13, {7} │ │ │ │ strhtle r4, [r7], -r8 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - cdp 7, 12, cr15, cr0, cr13, {7} │ │ │ │ + cdp 7, 12, cr15, cr4, cr13, {7} │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ @ instruction: 0xf7ed3708 │ │ │ │ + stmiavs r9!, {r6, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r2, r3, r4, r5, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r3, r4, r5, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r2, r4, r5, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r4, r5, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r2, r3, r5, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r9!, {r3, r5, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7ed2020 │ │ │ │ - ldrmi lr, [r8, #3748]! @ 0xea4 │ │ │ │ + ldrmi lr, [r8, #3752]! @ 0xea8 │ │ │ │ ldrd sp, [r3], -ip │ │ │ │ ldrvc pc, [r0, #-576]! @ 0xfffffdc0 │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ andcs r6, r0, #15400960 @ 0xeb0000 │ │ │ │ rsbsvs r2, r2, r1, lsl #2 │ │ │ │ - addne pc, ip, sp, asr #12 │ │ │ │ + addne pc, r4, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ed2202 │ │ │ │ - stmdavc r2!, {r1, r2, r3, r4, r5, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdavc r2!, {r1, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ cmnlt r2, #15400960 @ 0xeb0000 │ │ │ │ ldmdale pc!, {r1, r5, r9, fp, sp} @ │ │ │ │ ldmdble r2, {r1, r2, r9, fp, sp} │ │ │ │ ldmdbcs fp, {r0, r4, r6, r7, r8, r9, sl, fp, ip} │ │ │ │ ldm pc, {r0, r1, r2, r3, fp, ip, lr, pc}^ @ │ │ │ │ movls pc, r1 │ │ │ │ strbpl r7, [r5, -r2, lsl #7]! │ │ │ │ cdpeq 14, 0, cr0, cr14, cr9, {2} │ │ │ │ cdpeq 14, 0, cr0, cr14, cr14, {0} │ │ │ │ cdpeq 14, 0, cr0, cr14, cr14, {0} │ │ │ │ cdpeq 14, 0, cr0, cr14, cr14, {0} │ │ │ │ cdpeq 14, 0, cr0, cr14, cr14, {0} │ │ │ │ @ instruction: 0xf6422a0e │ │ │ │ - vsra.s64 q9, q0, #64 │ │ │ │ + vmla.f d18, d16, d0[2] │ │ │ │ @ instruction: 0xf8310103 │ │ │ │ @ instruction: 0x06c91012 │ │ │ │ addshi pc, r8, r0, asr #2 │ │ │ │ ldrdne lr, [r5], -r3 │ │ │ │ svclt 0x003e4281 │ │ │ │ cmpvs r8, r8, asr #24 │ │ │ │ @ instruction: 0xf080700a │ │ │ │ @ instruction: 0xf814809d │ │ │ │ - bcs 2f1b0 <__time64@plt+0x1dec8> │ │ │ │ + bcs 2f1a8 <__time64@plt+0x1dec0> │ │ │ │ pop {r1, r4, r6, r7, r8, ip, lr, pc} │ │ │ │ @ instruction: 0x461941f0 │ │ │ │ @ instruction: 0xf7ed2022 │ │ │ │ - andcs fp, r2, #5696 @ 0x1640 │ │ │ │ + andcs fp, r2, #5952 @ 0x1740 │ │ │ │ @ instruction: 0xf64d2101 │ │ │ │ - vaddl.s8 , d16, d28 │ │ │ │ + vaddl.s8 , d16, d20 │ │ │ │ @ instruction: 0xf7ed0002 │ │ │ │ - @ instruction: 0xf814ed40 │ │ │ │ + @ instruction: 0xf814ed44 │ │ │ │ stmiavs fp!, {r0, r8, r9, sl, fp, sp}^ │ │ │ │ rscle r2, ip, r0, lsl #20 │ │ │ │ ldmible pc!, {r1, r5, r9, fp, sp} @ │ │ │ │ bicsle r2, r2, ip, asr sl │ │ │ │ tstcs r1, r2, lsl #4 │ │ │ │ - adcsne pc, r0, sp, asr #12 │ │ │ │ + adcne pc, r8, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - stc 7, cr15, [lr, #-948]! @ 0xfffffc4c │ │ │ │ + ldc 7, cr15, [r2, #-948]! @ 0xfffffc4c │ │ │ │ svccs 0x0001f814 │ │ │ │ - bcs 3d9a0 <__time64@plt+0x2c6b8> │ │ │ │ + bcs 3d998 <__time64@plt+0x2c6b0> │ │ │ │ ldrb sp, [sl, lr, lsr #3] │ │ │ │ tstcs r1, r2, lsl #4 │ │ │ │ - adcne pc, r8, sp, asr #12 │ │ │ │ + adcne pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - stc 7, cr15, [r0, #-948]! @ 0xfffffc4c │ │ │ │ + stc 7, cr15, [r4, #-948]! @ 0xfffffc4c │ │ │ │ svccs 0x0001f814 │ │ │ │ - bcs 3d9bc <__time64@plt+0x2c6d4> │ │ │ │ + bcs 3d9b4 <__time64@plt+0x2c6cc> │ │ │ │ strb sp, [ip, r0, lsr #3] │ │ │ │ tstcs r1, r2, lsl #4 │ │ │ │ - adcne pc, r4, sp, asr #12 │ │ │ │ + addsne pc, ip, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - ldc 7, cr15, [r2, #-948] @ 0xfffffc4c │ │ │ │ + ldc 7, cr15, [r6, #-948] @ 0xfffffc4c │ │ │ │ svccs 0x0001f814 │ │ │ │ - bcs 3d9d8 <__time64@plt+0x2c6f0> │ │ │ │ + bcs 3d9d0 <__time64@plt+0x2c6e8> │ │ │ │ @ instruction: 0xe7bed192 │ │ │ │ tstcs r1, r2, lsl #4 │ │ │ │ - adcne pc, r0, sp, asr #12 │ │ │ │ + addsne pc, r8, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - stc 7, cr15, [r4, #-948] @ 0xfffffc4c │ │ │ │ + stc 7, cr15, [r8, #-948] @ 0xfffffc4c │ │ │ │ svccs 0x0001f814 │ │ │ │ - bcs 3d9f4 <__time64@plt+0x2c70c> │ │ │ │ + bcs 3d9ec <__time64@plt+0x2c704> │ │ │ │ ldr sp, [r0, r4, lsl #3]! │ │ │ │ tstcs r1, r2, lsl #4 │ │ │ │ - addsne pc, ip, sp, asr #12 │ │ │ │ + addsne pc, r4, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - ldcl 7, cr15, [r6], #948 @ 0x3b4 │ │ │ │ + ldcl 7, cr15, [sl], #948 @ 0x3b4 │ │ │ │ svccs 0x0001f814 │ │ │ │ - bcs 3da10 <__time64@plt+0x2c728> │ │ │ │ + bcs 3da08 <__time64@plt+0x2c720> │ │ │ │ svcge 0x0076f47f │ │ │ │ andcs lr, r2, #42205184 @ 0x2840000 │ │ │ │ @ instruction: 0xf64d2101 │ │ │ │ - vshr.s64 d17, d8, #64 │ │ │ │ + vshr.s64 d17, d0, #64 │ │ │ │ @ instruction: 0xf7ed0002 │ │ │ │ - @ instruction: 0xf814ece8 │ │ │ │ + @ instruction: 0xf814ecec │ │ │ │ stmiavs fp!, {r0, r8, r9, sl, fp, sp}^ │ │ │ │ @ instruction: 0xf47f2a00 │ │ │ │ ldr sl, [r2, r7, ror #30] │ │ │ │ tstcs r1, r2, lsl #4 │ │ │ │ - addsne pc, r4, sp, asr #12 │ │ │ │ + addne pc, ip, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - ldcl 7, cr15, [r8], {237} @ 0xed │ │ │ │ + ldcl 7, cr15, [ip], {237} @ 0xed │ │ │ │ svccs 0x0001f814 │ │ │ │ - bcs 3da4c <__time64@plt+0x2c764> │ │ │ │ + bcs 3da44 <__time64@plt+0x2c75c> │ │ │ │ svcge 0x0058f47f │ │ │ │ andcs lr, r2, #34340864 @ 0x20c0000 │ │ │ │ @ instruction: 0xf64d2101 │ │ │ │ - vshr.s64 d17, d0, #64 │ │ │ │ + vaddl.s8 , d16, d8 │ │ │ │ @ instruction: 0xf7ed0002 │ │ │ │ - @ instruction: 0xf814ecca │ │ │ │ + @ instruction: 0xf814ecce │ │ │ │ stmiavs fp!, {r0, r8, r9, sl, fp, sp}^ │ │ │ │ @ instruction: 0xf47f2a00 │ │ │ │ ldrb sl, [r4, -r9, asr #30]! │ │ │ │ @ instruction: 0xf64d4618 │ │ │ │ - vsra.s64 d17, d20, #64 │ │ │ │ + vaddw.s8 , q8, d28 │ │ │ │ @ instruction: 0xf7ed0102 │ │ │ │ - @ instruction: 0xf814ed6e │ │ │ │ + @ instruction: 0xf814ed72 │ │ │ │ stmiavs fp!, {r0, r8, r9, sl, fp, sp}^ │ │ │ │ @ instruction: 0xf47f2a00 │ │ │ │ @ instruction: 0xe766af3b │ │ │ │ @ instruction: 0x46114618 │ │ │ │ - ldc 7, cr15, [r0, #948]! @ 0x3b4 │ │ │ │ + ldc 7, cr15, [r4, #948]! @ 0x3b4 │ │ │ │ ldrb r6, [ip, -fp, ror #17] │ │ │ │ teqlt r9, #112, 10 @ 0x1c000000 │ │ │ │ strmi r6, [ip], -fp, asr #16 │ │ │ │ vstmdble r3!, {d2-d1} │ │ │ │ stmdavs r8, {r0, r2, r9, sl, lr} │ │ │ │ eorsle r2, r9, r0, lsl #16 │ │ │ │ - blx 5e16e8 │ │ │ │ + blx 5e16e0 │ │ │ │ strtmi r4, [r8], -r6, lsl #12 │ │ │ │ @ instruction: 0xf64db34e │ │ │ │ - vsra.s64 , q0, #64 │ │ │ │ + vmla.f d17, d16, d0[2] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ @ instruction: 0x4631fd9f │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ @ instruction: 0xf240fe9f │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ stmdavs r2!, {r0, r2, r8, r9}^ │ │ │ │ - tstpne r4, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpne ip, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ed68d8 │ │ │ │ - @ instruction: 0x4628ed3c │ │ │ │ + strtmi lr, [r8], -r0, asr #26 │ │ │ │ ldrhtmi lr, [r0], #-141 @ 0xffffff73 │ │ │ │ mrclt 7, 0, APSR_nzcv, cr2, cr15, {7} │ │ │ │ teqpvc r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - sbcsne pc, ip, sp, asr #12 │ │ │ │ + sbcsne pc, r4, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrhtmi lr, [r0], #-141 @ 0xffffff73 │ │ │ │ ldmvs fp, {r2, r9, sp}^ │ │ │ │ @ instruction: 0xf7ed2101 │ │ │ │ - @ instruction: 0xf64dbcb5 │ │ │ │ - vmla.f d17, d16, d0[2] │ │ │ │ + @ instruction: 0xf64dbcb9 │ │ │ │ + vmla.f d17, d16, d0[0] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ stmdavs r1!, {r0, r2, r4, r5, r6, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ sbcsle r2, r3, r0, lsl #18 │ │ │ │ ldrb r3, [r1, r9, lsl #2] │ │ │ │ - adcsne pc, ip, #80740352 @ 0x4d00000 │ │ │ │ + adcsne pc, r4, #80740352 @ 0x4d00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ orrscs pc, sl, r0, asr #4 │ │ │ │ - cdp2 7, 9, cr15, cr14, cr13, {7} │ │ │ │ + cdp2 7, 10, cr15, cr2, cr13, {7} │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ vand q10, q8, q8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strmi r0, [r5], -r5, lsl #8 │ │ │ │ - blcs 34fdc <__time64@plt+0x23cf4> │ │ │ │ + blcs 34fd4 <__time64@plt+0x23cec> │ │ │ │ @ instruction: 0xf8d0d060 │ │ │ │ vhadd.s8 d24, d0, d0 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf1b80405 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf0182600 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -18743,68 +18741,68 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], -sl, asr #26 │ │ │ │ + strcc lr, [r1], -lr, asr #26 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stcl 7, cr15, [r4, #-948] @ 0xfffffc4c │ │ │ │ + stcl 7, cr15, [r8, #-948] @ 0xfffffc4c │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], -r0, asr #26 │ │ │ │ + strcc lr, [r1], -r4, asr #26 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [sl, #-948]! @ 0xfffffc4c │ │ │ │ + ldc 7, cr15, [lr, #-948]! @ 0xfffffc4c │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - @ instruction: 0x3601ed36 │ │ │ │ + @ instruction: 0x3601ed3a │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [r0, #-948]! @ 0xfffffc4c │ │ │ │ + ldc 7, cr15, [r4, #-948]! @ 0xfffffc4c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed3601 │ │ │ │ - ldrmi lr, [r0, #3372]! @ 0xd2c │ │ │ │ + ldrmi lr, [r0, #3376]! @ 0xd30 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r1, r2, r5, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r3, r5, r8, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], -r0, lsr #32 │ │ │ │ + stc 7, cr15, [r4, #-948]! @ 0xfffffc4c │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r0, #-948]! @ 0xfffffc4c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldc 7, cr15, [ip, #-948] @ 0xfffffc4c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldc 7, cr15, [r8, #-948] @ 0xfffffc4c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldc 7, cr15, [r4, #-948] @ 0xfffffc4c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldc 7, cr15, [r0, #-948] @ 0xfffffc4c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [ip, #-948] @ 0xfffffc4c │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [r8, #-948] @ 0xfffffc4c │ │ │ │ ldrhle r4, [ip, #80] @ 0x50 │ │ │ │ mrscs r2, R9_usr │ │ │ │ @ instruction: 0xf64d606a │ │ │ │ - vmla.i d17, d16, d0[5] │ │ │ │ + vshr.s64 , q6, #64 │ │ │ │ stmiavs r3!, {r1}^ │ │ │ │ @ instruction: 0xf7ed2207 │ │ │ │ - ldmvs r9!, {r1, r3, r5, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmvs r9!, {r1, r2, r3, r5, sl, fp, sp, lr, pc}^ │ │ │ │ strtmi fp, [r8], -r1, lsr #2 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ stcllt 7, cr15, [sl, #1020]! @ 0x3fc │ │ │ │ @ instruction: 0xf64d68e3 │ │ │ │ - vmla.i d17, d16, d0[7] │ │ │ │ + vmla.i d17, d16, d0[5] │ │ │ │ andcs r0, r5, #2 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ @ instruction: 0xf7ed2101 │ │ │ │ - svclt 0x0000bc15 │ │ │ │ + svclt 0x0000bc19 │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ vand q10, q8, q8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strmi r0, [r5], -r5, lsl #8 │ │ │ │ - blcs 350f0 <__time64@plt+0x23e08> │ │ │ │ + blcs 350e8 <__time64@plt+0x23e00> │ │ │ │ @ instruction: 0xf8d0d060 │ │ │ │ vhadd.s8 d24, d0, d0 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf1b80405 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf0182600 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -18812,230 +18810,230 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], -r0, asr #25 │ │ │ │ + strcc lr, [r1], -r4, asr #25 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [sl], #948 @ 0x3b4 │ │ │ │ + ldc 7, cr15, [lr], #948 @ 0x3b4 │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - @ instruction: 0x3601ecb6 │ │ │ │ + @ instruction: 0x3601ecba │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [r0], #948 @ 0x3b4 │ │ │ │ + ldc 7, cr15, [r4], #948 @ 0x3b4 │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], -ip, lsr #25 │ │ │ │ + @ instruction: 0x3601ecb0 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [r6], #948 @ 0x3b4 │ │ │ │ + stc 7, cr15, [sl], #948 @ 0x3b4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed3601 │ │ │ │ - ldrmi lr, [r0, #3234]! @ 0xca2 │ │ │ │ + ldrmi lr, [r0, #3238]! @ 0xca6 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r2, r3, r4, r7, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r5, r7, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], -r0, lsr #32 │ │ │ │ + ldc 7, cr15, [sl], {237} @ 0xed │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ ldc 7, cr15, [r6], {237} @ 0xed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldc 7, cr15, [r2], {237} @ 0xed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [lr], {237} @ 0xed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [sl], {237} @ 0xed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r6], {237} @ 0xed │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r2], {237} @ 0xed │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - ldcl 7, cr15, [lr], #-948 @ 0xfffffc4c │ │ │ │ ldrhle r4, [ip, #80] @ 0x50 │ │ │ │ movwcs r6, #2272 @ 0x8e0 │ │ │ │ @ instruction: 0xf64d463a │ │ │ │ - vsra.s64 , q10, #64 │ │ │ │ + vmla.f d17, d16, d0[7] │ │ │ │ rsbvs r0, fp, r2, lsl #2 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - stclt 7, cr15, [ip], {237} @ 0xed │ │ │ │ + ldclt 7, cr15, [r0], {237} @ 0xed │ │ │ │ @ instruction: 0x4605b5f8 │ │ │ │ vmax.s8 d20, d11, d12 │ │ │ │ - vsra.s64 q11, q12, #64 │ │ │ │ + vsra.s64 q11, q8, #64 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ @ instruction: 0x4621fc59 │ │ │ │ vmax.s8 d20, d0, d24 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf7ff0405 │ │ │ │ ldmib r5, {r0, r2, r4, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ cdpcc 3, 0, cr6, cr1, cr0, {0} │ │ │ │ - blcs 3ba74 <__time64@plt+0x2a78c> │ │ │ │ + blcs 3ba6c <__time64@plt+0x2a784> │ │ │ │ mcrcs 0, 0, sp, cr0, cr9, {2} │ │ │ │ smlsdcs r0, r7, sp, sp │ │ │ │ movweq pc, #28694 @ 0x7016 @ │ │ │ │ - blcs 97a8c │ │ │ │ - blcs d7a6c │ │ │ │ - blcs 117a54 │ │ │ │ - blcs 157a3c │ │ │ │ - blcs 197a24 │ │ │ │ - blcs 1d7a0c │ │ │ │ + blcs 97a84 │ │ │ │ + blcs d7a64 │ │ │ │ + blcs 117a4c │ │ │ │ + blcs 157a34 │ │ │ │ + blcs 197a1c │ │ │ │ + blcs 1d7a04 │ │ │ │ strcs sp, [r1, -r4] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - mcrr 7, 14, pc, r2, cr13 @ │ │ │ │ + mcrr 7, 14, pc, r6, cr13 @ │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - smladxcc r1, lr, ip, lr │ │ │ │ + strcc lr, [r1, -r2, asr #24] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [r8], #-948 @ 0xfffffc4c │ │ │ │ + ldc 7, cr15, [ip], #-948 @ 0xfffffc4c │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - smladxcc r1, r4, ip, lr │ │ │ │ + smladxcc r1, r8, ip, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [lr], #-948 @ 0xfffffc4c │ │ │ │ + ldc 7, cr15, [r2], #-948 @ 0xfffffc4c │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r1, r3, r5, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r2, r3, r5, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1, -r0, lsr #32] │ │ │ │ - stc 7, cr15, [r4], #-948 @ 0xfffffc4c │ │ │ │ + stc 7, cr15, [r8], #-948 @ 0xfffffc4c │ │ │ │ strhtle r4, [r2], -lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [lr], {237} @ 0xed │ │ │ │ + stc 7, cr15, [r2], #-948 @ 0xfffffc4c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed3708 │ │ │ │ + stmiavs r1!, {r1, r2, r3, r4, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r1, r3, r4, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r1, r2, r4, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r1, r4, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r1, r2, r3, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r1, r3, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r1, r2, sl, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7ed2020 │ │ │ │ - adcsmi lr, lr, #512 @ 0x200 │ │ │ │ + adcsmi lr, lr, #1536 @ 0x600 │ │ │ │ movwcs sp, #476 @ 0x1dc │ │ │ │ rsbvs r6, fp, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed2029 │ │ │ │ - stmdavs fp!, {r1, r3, r4, r5, r6, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + stmdavs fp!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ ldcllt 1, cr11, [r8, #12]! │ │ │ │ andcs r6, sl, r1, ror #17 │ │ │ │ - bl ffce1a40 │ │ │ │ + bl ffde1a38 │ │ │ │ rsbvs r2, fp, r1, lsl #6 │ │ │ │ svclt 0x0000bdf8 │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x460541f0 │ │ │ │ - blcs 352dc <__time64@plt+0x23ff4> │ │ │ │ + blcs 352d4 <__time64@plt+0x23fec> │ │ │ │ stmdavs r3, {r0, r5, r6, ip, lr, pc} │ │ │ │ ldmcc pc!, {r0, r1, r8, ip, sp, lr, pc}^ @ │ │ │ │ svceq 0x0000f1b8 │ │ │ │ vmla.f32 , q0, │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strcs r0, [r0], -r5, lsl #8 │ │ │ │ movweq pc, #28696 @ 0x7018 @ │ │ │ │ - blcs 97b80 │ │ │ │ - blcs d7b60 │ │ │ │ - blcs 117b48 │ │ │ │ - blcs 157b30 │ │ │ │ - blcs 197b18 │ │ │ │ - blcs 1d7b00 │ │ │ │ + blcs 97b78 │ │ │ │ + blcs d7b58 │ │ │ │ + blcs 117b40 │ │ │ │ + blcs 157b28 │ │ │ │ + blcs 197b10 │ │ │ │ + blcs 1d7af8 │ │ │ │ strcs sp, [r1], -r4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl ff261a94 │ │ │ │ + bl ff361a8c │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], -r4, asr #23 │ │ │ │ + strcc lr, [r1], -r8, asr #23 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl fefe1aa8 │ │ │ │ + bl ff0e1aa0 │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - @ instruction: 0x3601ebba │ │ │ │ + @ instruction: 0x3601ebbe │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl fed61abc │ │ │ │ + bl fee61ab4 │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r4, r5, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r2, r4, r5, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1], -r0, lsr #32 │ │ │ │ - bl feae1ad0 │ │ │ │ + bl febe1ac8 │ │ │ │ strhtle r4, [r2], -r0 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl fe961adc │ │ │ │ + bl fea61ad4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed3608 │ │ │ │ + stmiavs r1!, {r2, r5, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r5, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r2, r3, r4, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r3, r4, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r2, r4, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r1!, {r4, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r2, r3, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7ed2020 │ │ │ │ - ldrmi lr, [r0, #2952]! @ 0xb88 │ │ │ │ + ldrmi lr, [r0, #2956]! @ 0xb8c │ │ │ │ movwcs sp, #476 @ 0x1dc │ │ │ │ svccs 0x0003606b │ │ │ │ ldm pc, {r0, r1, r2, r3, r4, r5, fp, ip, lr, pc}^ @ │ │ │ │ eorcs pc, pc, r7 │ │ │ │ vqsub.s8 d16, d0, d1 │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf64d0305 │ │ │ │ - vaddl.s8 q9, d0, d24 │ │ │ │ + vaddl.s8 q9, d0, d16 │ │ │ │ ldmfd sp!, {r1} │ │ │ │ andcs r4, lr, #240, 2 @ 0x3c │ │ │ │ ldrdcs r6, [r1, -fp] │ │ │ │ - blt fe6e1b48 │ │ │ │ + blt fe7e1b40 │ │ │ │ teqpvc r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - andscs pc, r0, sp, asr #12 │ │ │ │ + andcs pc, r8, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ ldmvs fp, {r2, r4, r9, sp}^ │ │ │ │ @ instruction: 0xf7ed2101 │ │ │ │ - vpmax.s8 d27, d16, d11 │ │ │ │ + vpmax.s8 d27, d16, d15 │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf64d0305 │ │ │ │ - vaddl.s8 q9, d0, d4 │ │ │ │ + vshr.s64 , q14, #64 │ │ │ │ ldmfd sp!, {r1} │ │ │ │ andcs r4, r8, #240, 2 @ 0x3c │ │ │ │ ldrdcs r6, [r1, -fp] │ │ │ │ - blt 1f61b84 │ │ │ │ + blt fe061b7c │ │ │ │ teqpvc r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - rscsne pc, r8, sp, asr #12 │ │ │ │ + rscsne pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ ldmvs fp, {r1, r3, r9, sp}^ │ │ │ │ @ instruction: 0xf7ed2101 │ │ │ │ - @ instruction: 0xf64dba6d │ │ │ │ - vmvn.i32 d18, #2048 @ 0x00000800 │ │ │ │ + @ instruction: 0xf64dba71 │ │ │ │ + vmvn.i32 d18, #0 @ 0x00000000 │ │ │ │ vhsub.s8 d16, d13, d2 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7ed4134 │ │ │ │ - svclt 0x0000fc61 │ │ │ │ + svclt 0x0000fc65 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ strmi r4, [ip], -r5, lsl #12 │ │ │ │ @ instruction: 0xf64db309 │ │ │ │ - vorr.i32 q9, #4 @ 0x00000004 │ │ │ │ + vmla.f d18, d0, d0[3] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ stmdavs r1!, {r0, r1, r3, r4, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ orrslt r4, r9, r8, lsr #12 │ │ │ │ ldc2 7, cr15, [sl], {255} @ 0xff │ │ │ │ strtmi r6, [r8], -r1, lsr #17 │ │ │ │ - blx fe25fc30 │ │ │ │ + blx fe25fc28 │ │ │ │ tstpeq ip, r4, lsl #2 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ @ instruction: 0x4628fd59 │ │ │ │ @ instruction: 0xf0016961 │ │ │ │ @ instruction: 0x4628fedb │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - bllt fe361c48 │ │ │ │ - asrscs pc, sp, #4 @ │ │ │ │ + bllt fe361c40 │ │ │ │ + @ instruction: 0x21a8f24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stmdavs r3, {r1, r2, r5, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ ldrtvc pc, [r0], -r0, asr #4 @ │ │ │ │ streq pc, [r5], -r0, asr #5 │ │ │ │ subsle r2, sp, r0, lsl #22 │ │ │ │ vadd.i8 d22, d0, d7 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @@ -19046,104 +19044,104 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ ldmvs r1!, {r0, sl, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], #-2796 @ 0xfffff514 │ │ │ │ + strcc lr, [r1], #-2800 @ 0xfffff510 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ - b ff9e1c58 │ │ │ │ + b ffae1c50 │ │ │ │ ldmvs r1!, {r0, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], #-2786 @ 0xfffff51e │ │ │ │ + strcc lr, [r1], #-2790 @ 0xfffff51a │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ - b ff761c6c │ │ │ │ + b ff861c64 │ │ │ │ ldmvs r1!, {r0, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], #-2776 @ 0xfffff528 │ │ │ │ + strcc lr, [r1], #-2780 @ 0xfffff524 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ - b ff4e1c80 │ │ │ │ + b ff5e1c78 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ @ instruction: 0xf7ed3401 │ │ │ │ - adcmi lr, r7, #843776 @ 0xce000 │ │ │ │ + adcmi lr, r7, #860160 @ 0xd2000 │ │ │ │ ldmvs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - ldmvs r1!, {r3, r6, r7, r9, fp, sp, lr, pc}^ │ │ │ │ + ldmvs r1!, {r2, r3, r6, r7, r9, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], #-32 @ 0xffffffe0 │ │ │ │ + b ff1e1c98 │ │ │ │ + strdcs r6, [r0], -r1 @ │ │ │ │ b ff0e1ca0 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ b fefe1ca8 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ b feee1cb0 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ b fede1cb8 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ b fece1cc0 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ b febe1cc8 │ │ │ │ - strdcs r6, [r0], -r1 @ │ │ │ │ - b feae1cd0 │ │ │ │ bicsle r4, ip, r7, lsr #5 │ │ │ │ ldmvs r3!, {r8, sp}^ │ │ │ │ @ instruction: 0xf64d6069 │ │ │ │ - vmla.i d18, d0, d0[3] │ │ │ │ + vmla.i d18, d0, d0[1] │ │ │ │ andcs r0, r4, #2 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ @ instruction: 0xf7ed2101 │ │ │ │ - svclt 0x0000b9c7 │ │ │ │ + svclt 0x0000b9cb │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ strmi r4, [sp], -r0, lsl #13 │ │ │ │ strmi fp, [ip], -r9, asr #6 │ │ │ │ stmdavs r4!, {r9, sl, sp} │ │ │ │ @ instruction: 0x36014637 │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ @ instruction: 0xf64d4640 │ │ │ │ - vmla.f d18, d0, d0[6] │ │ │ │ + vmla.f d18, d0, d0[4] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ vpmin.s8 , q0, │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf64d0305 │ │ │ │ - vsra.s64 , q10, #64 │ │ │ │ + vmla.f d17, d16, d0[7] │ │ │ │ ldrtmi r0, [r2], -r2, lsl #2 │ │ │ │ @ instruction: 0xf7ed68d8 │ │ │ │ - @ instruction: 0x4629ea1a │ │ │ │ + @ instruction: 0x4629ea1e │ │ │ │ @ instruction: 0xf7ff4640 │ │ │ │ stmdavs sp!, {r0, r1, r6, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ strcc r4, [r1], #-1571 @ 0xfffff9dd │ │ │ │ mvnsle r2, r0, lsl #26 │ │ │ │ @ instruction: 0xd11b42bb │ │ │ │ pop {r6, r9, sl, lr} │ │ │ │ @ instruction: 0xf7ff41f0 │ │ │ │ @ instruction: 0xf64dbae5 │ │ │ │ - vmla.f d18, d0, d0[6] │ │ │ │ + vmla.f d18, d0, d0[4] │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ vpmin.s8 , q0, │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ strtmi r0, [sl], -r5, lsl #6 │ │ │ │ - mvnsne pc, sp, asr #12 │ │ │ │ + mvnne pc, sp, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ed68d8 │ │ │ │ - @ instruction: 0x4640e9f8 │ │ │ │ + @ instruction: 0x4640e9fc │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - blt ff3e1dc4 │ │ │ │ - subscs pc, ip, #80740352 @ 0x4d00000 │ │ │ │ + blt ff3e1dbc │ │ │ │ + subscs pc, r4, #80740352 @ 0x4d00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ msrvc CPSR_fsx, pc, asr #8 │ │ │ │ - blx 1d61d96 │ │ │ │ + blx 1e61d8e │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ strmi r4, [lr], -r5, lsl #12 │ │ │ │ addlt r6, r5, fp, lsl r8 │ │ │ │ - blcs 35838 <__time64@plt+0x24550> │ │ │ │ + blcs 35830 <__time64@plt+0x24548> │ │ │ │ tstphi r9, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ - blcs 3dfac <__time64@plt+0x2ccc4> │ │ │ │ + blcs 3dfa4 <__time64@plt+0x2ccbc> │ │ │ │ @ instruction: 0xf8d5d061 │ │ │ │ @ instruction: 0xf1b99000 │ │ │ │ ldclle 15, cr0, [ip, #-0] │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ @ instruction: 0xf0192700 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -19151,374 +19149,374 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - smladcc r1, sl, sl, lr │ │ │ │ + smladcc r1, lr, sl, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - b 561dfc │ │ │ │ + b 661df4 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - smladcc r1, r0, sl, lr │ │ │ │ + smladcc r1, r4, sl, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - b 2e1e10 │ │ │ │ + b 3e1e08 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1, -r6, lsl #20] │ │ │ │ + strcc lr, [r1, -sl, lsl #20] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - b 61e24 │ │ │ │ + b 161e1c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed3701 │ │ │ │ - ldrmi lr, [r9, #2556]! @ 0x9fc │ │ │ │ + ldrmi lr, [r9, #2560]! @ 0xa00 │ │ │ │ stmiavs r1!, {r0, r1, r2, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r1, r2, r4, r5, r6, r7, r8, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r3, r4, r5, r6, r7, r8, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + ldmib r4!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ ldmib r0!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmib ip!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmib r8!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmib r4!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmib r0!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmib ip, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmib r8, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrhle r4, [ip, #89] @ 0x59 │ │ │ │ vhadd.s8 d30, d0, d3 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ movwcs r0, #1029 @ 0x405 │ │ │ │ rsbvs r4, fp, r2, asr #12 │ │ │ │ - orrscs pc, r0, sp, asr #12 │ │ │ │ + orrcs pc, r8, sp, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ed68e0 │ │ │ │ - ldrtmi lr, [r1], -r6, ror #18 │ │ │ │ + ldrtmi lr, [r1], -sl, ror #18 │ │ │ │ @ instruction: 0xf0004628 │ │ │ │ ldmdbvs r1!, {r0, r1, r2, r3, r6, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0002900 │ │ │ │ strtmi r8, [r8], -fp, lsr #1 │ │ │ │ - blx fece1ef4 │ │ │ │ - bcs 2bdfc4 │ │ │ │ + blx fece1eec │ │ │ │ + bcs 2bdfbc │ │ │ │ tstphi r3, r0, lsl #4 @ p-variant is OBSOLETE │ │ │ │ addsmi r2, r3, r1, lsl #6 │ │ │ │ svcvc 0x00e6f413 │ │ │ │ vand , q0, │ │ │ │ andsmi r6, r3, #536870915 @ 0x20000003 │ │ │ │ @ instruction: 0xf106bf18 │ │ │ │ @ instruction: 0xf0000118 │ │ │ │ strtmi r8, [r8], -r8, lsl #2 │ │ │ │ - blx ff9e1f1e │ │ │ │ + blx ff9e1f16 │ │ │ │ @ instruction: 0x46286a31 │ │ │ │ @ instruction: 0xff0af7ff │ │ │ │ @ instruction: 0x46286a71 │ │ │ │ stc2l 0, cr15, [r4, #-4]! │ │ │ │ @ instruction: 0xf8d6686b │ │ │ │ - blcs 43fd8 <__time64@plt+0x32cf0> │ │ │ │ + blcs 43fd0 <__time64@plt+0x32ce8> │ │ │ │ stmdavs pc!, {r1, r3, r4, r6, ip, lr, pc} @ │ │ │ │ ldclle 15, cr2, [r7, #-0] │ │ │ │ @ instruction: 0xf0172600 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ eorle r2, r7, r1, lsl #22 │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1], -r4, lsl #19 │ │ │ │ + strcc lr, [r1], -r8, lsl #19 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmdb lr!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib r2, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - @ instruction: 0x3601e97a │ │ │ │ + @ instruction: 0x3601e97e │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmdb r4!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdb r8!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - @ instruction: 0x3601e970 │ │ │ │ + @ instruction: 0x3601e974 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmdb sl!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb lr!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed3601 │ │ │ │ - adcsmi lr, r7, #1671168 @ 0x198000 │ │ │ │ + adcsmi lr, r7, #1736704 @ 0x1a8000 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r5, r6, r8, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r2, r5, r6, r8, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], -r0, lsr #32 │ │ │ │ + ldmdb lr, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ ldmdb sl, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmdb r6, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmdb r2, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdb lr, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdb sl, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdb r6, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - stmdb r2, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrhle r4, [ip, #39] @ 0x27 │ │ │ │ stmiavs r0!, {r8, r9, sp}^ │ │ │ │ @ instruction: 0xf64d4642 │ │ │ │ - vsra.s64 , q10, #64 │ │ │ │ + vmla.f d17, d16, d0[7] │ │ │ │ rsbvs r0, fp, r2, lsl #2 │ │ │ │ pop {r0, r2, ip, sp, pc} │ │ │ │ @ instruction: 0xf7ed43f0 │ │ │ │ - smlabtcs r0, pc, r8, fp @ │ │ │ │ + ldrdcs fp, [r0, -r3] │ │ │ │ vabd.s8 d30, d16, d5 │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ vcgt.s8 d16, d13, d5 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ ldmdavs ip, {r1} │ │ │ │ mrc2 7, 2, pc, cr6, cr3, {7} │ │ │ │ strmi r9, [r2], -r1, lsl #12 │ │ │ │ andhi pc, r0, sp, asr #17 │ │ │ │ @ instruction: 0xf64d4620 │ │ │ │ - vbic.i32 q9, #0 @ 0x00000000 │ │ │ │ + vmla.f d18, d0, d0[6] │ │ │ │ ldmdbvs r3!, {r1, r8}^ │ │ │ │ ldmvs r3!, {r0, r1, r8, r9, ip, pc} │ │ │ │ vcgt.s8 d25, d0, d2 │ │ │ │ @ instruction: 0xf7ed33a6 │ │ │ │ - @ instruction: 0xe6d9e8b4 │ │ │ │ - blcs 3e1f8 <__time64@plt+0x2cf10> │ │ │ │ + @ instruction: 0xe6d9e8b8 │ │ │ │ + blcs 3e1f0 <__time64@plt+0x2cf08> │ │ │ │ @ instruction: 0xf8d5d05c │ │ │ │ @ instruction: 0xf1b88000 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf018460f │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ eorle r2, r7, r1, lsl #22 │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - @ instruction: 0x3701e8f8 │ │ │ │ + @ instruction: 0x3701e8fc │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldm r2!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm r6!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1, -lr, ror #17] │ │ │ │ + @ instruction: 0x3701e8f2 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmia r8!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia ip!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1, -r4, ror #17] │ │ │ │ + strcc lr, [r1, -r8, ror #17] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldm lr, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia r2!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ed3701 │ │ │ │ - ldrmi lr, [r8, #2266]! @ 0x8da │ │ │ │ + ldrmi lr, [r8, #2270]! @ 0x8de │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r1!, {r2, r4, r6, r7, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r3, r4, r6, r7, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + ldm r2, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ stmia lr, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmia sl, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmia r6, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmia r2, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldm lr!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldm sl!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - ldm r6!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ stmiavs r3!, {r9, sp}^ │ │ │ │ tstcs r1, sl, rrx │ │ │ │ vhsub.s8 d18, d13, d3 │ │ │ │ - vshr.s64 d18, d16, #64 │ │ │ │ + vaddl.s8 q9, d16, d24 │ │ │ │ @ instruction: 0xf7ec0002 │ │ │ │ - ldmdavs r2!, {r3, r4, r6, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + ldmdavs r2!, {r2, r3, r4, r6, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf67f2a0a │ │ │ │ @ instruction: 0xf7edaeed │ │ │ │ - vmla.i8 d31, d13, d5 │ │ │ │ - vmlal.s , d0, d0[5] │ │ │ │ + vmla.i8 d31, d13, d9 │ │ │ │ + vmov.i32 , #3072 @ 0x00000c00 │ │ │ │ vhsub.s8 d16, d13, d2 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ teqcs r1, r2 │ │ │ │ - @ instruction: 0xf9c4f7ed │ │ │ │ + @ instruction: 0xf9c8f7ed │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x460441f0 │ │ │ │ addlt r4, r4, lr, lsl #12 │ │ │ │ rsble r2, r0, r0, lsl #22 │ │ │ │ ldrdhi pc, [r0], -r0 │ │ │ │ svceq 0x0000f1b8 │ │ │ │ vmla.f32 , q0, │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ strcs r0, [r0, -r5, lsl #10] │ │ │ │ movweq pc, #28696 @ 0x7018 @ │ │ │ │ - blcs 9822c │ │ │ │ - blcs d820c │ │ │ │ - blcs 1181f4 │ │ │ │ - blcs 1581dc │ │ │ │ - blcs 1981c4 │ │ │ │ - blcs 1d81ac │ │ │ │ + blcs 98224 │ │ │ │ + blcs d8204 │ │ │ │ + blcs 1181ec │ │ │ │ + blcs 1581d4 │ │ │ │ + blcs 1981bc │ │ │ │ + blcs 1d81a4 │ │ │ │ strcs sp, [r1, -r4] │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - ldmda r2!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r6!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1, -lr, ror #16] │ │ │ │ + smlsdxcc r1, r2, r8, lr │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - stmda r8!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda ip!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - strcc lr, [r1, -r4, ror #16] │ │ │ │ + strcc lr, [r1, -r8, ror #16] │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - ldmda lr, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda r2!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r9!, {r1, r3, r4, r6, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r9!, {r1, r2, r3, r4, r6, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1, -r0, lsr #32] │ │ │ │ - ldmda r4, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r8, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ strhtle r4, [r2], -r8 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - stmda lr, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r2, {r0, r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ @ instruction: 0xf7ed3708 │ │ │ │ + stmiavs r9!, {r1, r2, r3, r6, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r1, r3, r6, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r1, r2, r6, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r1, r6, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r1, r2, r3, r4, r5, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ stmiavs r9!, {r1, r3, r4, r5, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ed2020 │ │ │ │ - stmiavs r9!, {r1, r2, r4, r5, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7ed2020 │ │ │ │ - ldrmi lr, [r8, #2098]! @ 0x832 │ │ │ │ + ldrmi lr, [r8, #2102]! @ 0x836 │ │ │ │ @ instruction: 0x2700d1dc │ │ │ │ cdpcs 0, 0, cr6, cr0, cr7, {3} │ │ │ │ adchi pc, ip, r0 │ │ │ │ vmax.s8 d20, d9, d16 │ │ │ │ - vaddw.s8 q11, q8, d28 │ │ │ │ + vaddw.s8 q11, q8, d20 │ │ │ │ @ instruction: 0xf7ff0102 │ │ │ │ ldmvs r2!, {r0, r2, r4, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xdc1b2a00 │ │ │ │ rscscc pc, r8, #64, 4 │ │ │ │ andeq pc, r5, #192, 4 │ │ │ │ ldmdavs r2, {r0, r1, r5, r7, fp, sp, lr} │ │ │ │ adcvs r3, r3, r1, lsl #6 │ │ │ │ @ instruction: 0xf0402a00 │ │ │ │ ldmdavs r2!, {r0, r1, r2, r5, r7, pc} │ │ │ │ - bcs 2bc518 │ │ │ │ + bcs 2bc510 │ │ │ │ ldm pc, {r0, r3, r4, r5, r6, fp, ip, lr, pc}^ @ │ │ │ │ tstpeq lr, r2, lsl r0 @ p-variant is OBSOLETE │ │ │ │ ldrdeq r0, [r1], #12 @ │ │ │ │ rsceq r0, fp, r6, ror #1 │ │ │ │ strdeq r0, [r8], #12 │ │ │ │ sbcseq r0, r2, sp, asr #1 │ │ │ │ ldrdeq r0, [r9, -r7] │ │ │ │ - blcs 3e3f8 <__time64@plt+0x2d110> │ │ │ │ + blcs 3e3f0 <__time64@plt+0x2d108> │ │ │ │ @ instruction: 0xf8d4d06f │ │ │ │ @ instruction: 0xf1b88000 │ │ │ │ stclle 15, cr0, [sl, #-0] │ │ │ │ ldrvc pc, [r0, #-576]! @ 0xfffffdc0 │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ movweq pc, #28696 @ 0x7018 @ │ │ │ │ - blcs 98348 │ │ │ │ - blcs d8328 │ │ │ │ - blcs 118310 │ │ │ │ - blcs 1582f8 │ │ │ │ - blcs 1982e0 │ │ │ │ - blcs 1d82c8 │ │ │ │ + blcs 98340 │ │ │ │ + blcs d8320 │ │ │ │ + blcs 118308 │ │ │ │ + blcs 1582f0 │ │ │ │ + blcs 1982d8 │ │ │ │ + blcs 1d82c0 │ │ │ │ strcs sp, [r1, -r4] │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - svc 0x00e4f7ec │ │ │ │ + svc 0x00e8f7ec │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -r0, ror #31] │ │ │ │ + strcc lr, [r1, -r4, ror #31] │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - svc 0x00daf7ec │ │ │ │ + svc 0x00def7ec │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3701efd6 │ │ │ │ + @ instruction: 0x3701efda │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - svc 0x00d0f7ec │ │ │ │ + svc 0x00d4f7ec │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r9!, {r2, r3, r6, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r9!, {r4, r6, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1, -r0, lsr #32] │ │ │ │ - svc 0x00c6f7ec │ │ │ │ + svc 0x00caf7ec │ │ │ │ strhtle r4, [r2], -r8 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - svc 0x00c0f7ec │ │ │ │ + svc 0x00c4f7ec │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ @ instruction: 0xf7ec3708 │ │ │ │ + stmiavs r9!, {r6, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r9!, {r2, r3, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r9!, {r3, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r9!, {r2, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r9!, {r4, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r9!, {r2, r3, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r9!, {r3, r5, r7, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7ec2020 │ │ │ │ - ldrmi lr, [r8, #4004]! @ 0xfa4 │ │ │ │ + ldrmi lr, [r8, #4008]! @ 0xfa8 │ │ │ │ ldmvs r2!, {r2, r3, r4, r6, r7, r8, ip, lr, pc} │ │ │ │ @ instruction: 0xf64d2300 │ │ │ │ - vsra.s64 d18, d4, #64 │ │ │ │ + vaddw.s8 q9, q8, d12 │ │ │ │ stmiavs r8!, {r1, r8}^ │ │ │ │ @ instruction: 0xf7ec6063 │ │ │ │ - qasxmi lr, r0, r6 │ │ │ │ + qasxmi lr, r0, sl │ │ │ │ pop {r2, ip, sp, pc} │ │ │ │ @ instruction: 0xf7ff41f0 │ │ │ │ vadd.i8 d27, d0, d11 │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ strcs r0, [r0, #-773] @ 0xfffffcfb │ │ │ │ - orrscs pc, r4, sp, asr #12 │ │ │ │ + orrcs pc, ip, sp, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldmvs r8, {r0, r2, r5, r6, sp, lr}^ │ │ │ │ - svc 0x0022f7ec │ │ │ │ + svc 0x0026f7ec │ │ │ │ andlt r4, r4, r0, lsr #12 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ svclt 0x00f8f7fe │ │ │ │ teqpvc r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ tstcs r1, r4, lsl #4 │ │ │ │ - sbcsne pc, ip, sp, asr #12 │ │ │ │ + sbcsne pc, r4, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrdlt r6, [r4], -fp │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - cdplt 7, 9, cr15, cr10, cr12, {7} │ │ │ │ + cdplt 7, 9, cr15, cr14, cr12, {7} │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f3681d │ │ │ │ ldmvs r3!, {r0, r1, r4, r7, sl, fp, ip, sp, lr, pc} │ │ │ │ movwls r4, #9730 @ 0x2602 │ │ │ │ @ instruction: 0xf64d4628 │ │ │ │ - vaddw.s8 q9, q8, d20 │ │ │ │ + vsra.s64 d18, d12, #64 │ │ │ │ stmiavs r3!, {r1, r8} │ │ │ │ strcc lr, [r0], -sp, asr #19 │ │ │ │ cmppmi lr, #64, 4 @ p-variant is OBSOLETE │ │ │ │ - cdp 7, 15, cr15, cr2, cr12, {7} │ │ │ │ + cdp 7, 15, cr15, cr6, cr12, {7} │ │ │ │ stmiavs r2!, {r0, r1, r4, r5, fp, sp, lr} │ │ │ │ - blcs 2bc698 │ │ │ │ + blcs 2bc690 │ │ │ │ ldm pc, {r0, r1, r2, r4, r5, r7, fp, ip, lr, pc}^ @ │ │ │ │ - bne 13603e4 │ │ │ │ - bcc a6d458 │ │ │ │ + bne 13603dc │ │ │ │ + bcc a6d450 │ │ │ │ ldrne r0, [r0, #-2822] @ 0xfffff4fa │ │ │ │ ldrtmi r0, [r1], -r7, asr #32 │ │ │ │ @ instruction: 0xf0004620 │ │ │ │ str pc, [sl, fp, ror #28]! │ │ │ │ @ instruction: 0x46204631 │ │ │ │ stc2 0, cr15, [sl, #-0] │ │ │ │ ldrtmi lr, [r1], -r5, lsr #15 │ │ │ │ @@ -19531,42 +19529,42 @@ │ │ │ │ @ instruction: 0xe796f9f9 │ │ │ │ @ instruction: 0x46204631 │ │ │ │ mrrc2 0, 0, pc, r4, cr0 @ │ │ │ │ @ instruction: 0x4631e791 │ │ │ │ @ instruction: 0xf0004620 │ │ │ │ str pc, [ip, r7, asr #23] │ │ │ │ @ instruction: 0x46204631 │ │ │ │ - sbcscc pc, r0, #76, 12 @ 0x4c00000 │ │ │ │ + sbccc pc, r8, #76, 12 @ 0x4c00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ ldc2l 7, cr15, [r4], {255} @ 0xff │ │ │ │ @ instruction: 0x46206af1 │ │ │ │ mcr2 7, 4, pc, cr0, cr15, {7} @ │ │ │ │ @ instruction: 0x46206b31 │ │ │ │ mrc2 7, 3, pc, cr12, cr15, {7} │ │ │ │ @ instruction: 0x4631e77b │ │ │ │ vmax.s8 d20, d9, d16 │ │ │ │ - vmlal.s , d16, d0[3] │ │ │ │ + vmlal.s , d16, d0[1] │ │ │ │ @ instruction: 0xf7ff0202 │ │ │ │ - bvs ffca3768 │ │ │ │ + bvs ffca3760 │ │ │ │ @ instruction: 0xf7ff4620 │ │ │ │ strb pc, [lr, -pc, ror #28]! @ │ │ │ │ @ instruction: 0x46204631 │ │ │ │ @ instruction: 0xf88ef000 │ │ │ │ @ instruction: 0xf64de769 │ │ │ │ - vrshr.s64 q9, q0, #64 │ │ │ │ + vmlal.s q9, d16, d0[2] │ │ │ │ vhsub.s8 d16, d13, d2 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7ed4164 │ │ │ │ - svclt 0x0000f821 │ │ │ │ + svclt 0x0000f825 │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ vand q10, q8, q8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strmi r0, [r5], -r5, lsl #8 │ │ │ │ - blcs 35cd4 <__time64@plt+0x249ec> │ │ │ │ + blcs 35ccc <__time64@plt+0x249e4> │ │ │ │ @ instruction: 0xf8d0d060 │ │ │ │ vhadd.s8 d24, d0, d0 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf1b80405 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf0182700 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -19574,58 +19572,58 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -ip, asr #29] │ │ │ │ + @ instruction: 0x3701eed0 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 12, cr15, cr6, cr12, {7} │ │ │ │ + cdp 7, 12, cr15, cr10, cr12, {7} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -r2, asr #29] │ │ │ │ + strcc lr, [r1, -r6, asr #29] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 11, cr15, cr12, cr12, {7} │ │ │ │ + cdp 7, 12, cr15, cr0, cr12, {7} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3701eeb8 │ │ │ │ + @ instruction: 0x3701eebc │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 11, cr15, cr2, cr12, {7} │ │ │ │ + cdp 7, 11, cr15, cr6, cr12, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3701 │ │ │ │ - ldrmi lr, [r8, #3758]! @ 0xeae │ │ │ │ + ldrmi lr, [r8, #3762]! @ 0xeb2 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r3, r5, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r2, r3, r5, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + cdp 7, 10, cr15, cr6, cr12, {7} │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 10, cr15, cr2, cr12, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 9, cr15, cr14, cr12, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 9, cr15, cr10, cr12, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 9, cr15, cr6, cr12, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 9, cr15, cr2, cr12, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 8, cr15, cr14, cr12, {7} │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 8, cr15, cr10, cr12, {7} │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ movwcs r6, #2226 @ 0x8b2 │ │ │ │ @ instruction: 0xf64d68e0 │ │ │ │ - vsra.s64 , q10, #64 │ │ │ │ + vmla.f d17, d16, d0[7] │ │ │ │ rsbvs r0, fp, r2, lsl #2 │ │ │ │ - cdp 7, 1, cr15, cr12, cr12, {7} │ │ │ │ + cdp 7, 2, cr15, cr0, cr12, {7} │ │ │ │ @ instruction: 0x462868f1 │ │ │ │ stc2l 7, cr15, [r2, #1020]! @ 0x3fc │ │ │ │ @ instruction: 0x46286931 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - blt fe1e2584 │ │ │ │ + blt fe1e257c │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ strmi r4, [lr], -r5, lsl #12 │ │ │ │ addlt r6, r4, fp, lsl r8 │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ stmdavs fp!, {r1, r3, r4, r7, pc}^ │ │ │ │ @@ -19634,68 +19632,68 @@ │ │ │ │ rsble r2, r0, r0, lsl #22 │ │ │ │ ldrdhi pc, [r0], -r5 │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ svceq 0x0000f1b8 │ │ │ │ smlsdcs r0, r7, sp, sp │ │ │ │ movweq pc, #28696 @ 0x7018 @ │ │ │ │ - blcs 9868c │ │ │ │ - blcs d866c │ │ │ │ - blcs 118654 │ │ │ │ - blcs 15863c │ │ │ │ - blcs 198624 │ │ │ │ - blcs 1d860c │ │ │ │ + blcs 98684 │ │ │ │ + blcs d8664 │ │ │ │ + blcs 11864c │ │ │ │ + blcs 158634 │ │ │ │ + blcs 19861c │ │ │ │ + blcs 1d8604 │ │ │ │ strcs sp, [r1, -r4] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 4, cr15, cr2, cr12, {7} │ │ │ │ + cdp 7, 4, cr15, cr6, cr12, {7} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - smladxcc r1, lr, lr, lr │ │ │ │ + strcc lr, [r1, -r2, asr #28] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 3, cr15, cr8, cr12, {7} │ │ │ │ + cdp 7, 3, cr15, cr12, cr12, {7} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - smladxcc r1, r4, lr, lr │ │ │ │ + smladxcc r1, r8, lr, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 2, cr15, cr14, cr12, {7} │ │ │ │ + cdp 7, 3, cr15, cr2, cr12, {7} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r1, r3, r5, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r2, r3, r5, r9, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1, -r0, lsr #32] │ │ │ │ - cdp 7, 2, cr15, cr4, cr12, {7} │ │ │ │ + cdp 7, 2, cr15, cr8, cr12, {7} │ │ │ │ strhtle r4, [r2], -r8 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 1, cr15, cr14, cr12, {7} │ │ │ │ + cdp 7, 2, cr15, cr2, cr12, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3708 │ │ │ │ + stmiavs r1!, {r1, r2, r3, r4, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r1, r3, r4, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r1, r2, r4, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r1, r4, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r1, r2, r3, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r1, r3, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r1, r2, r9, sl, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7ec2020 │ │ │ │ - ldrmi lr, [r8, #3586]! @ 0xe02 │ │ │ │ + ldrmi lr, [r8, #3590]! @ 0xe06 │ │ │ │ stmiavs r3!, {r2, r3, r4, r6, r7, r8, ip, lr, pc}^ │ │ │ │ mrscs r2, R9_usr │ │ │ │ @ instruction: 0xf64d606a │ │ │ │ - vaddl.s8 , d0, d12 │ │ │ │ + vaddl.s8 , d0, d4 │ │ │ │ andcs r0, ip, #2 │ │ │ │ - stc 7, cr15, [r2, #-944]! @ 0xfffffc50 │ │ │ │ + stc 7, cr15, [r6, #-944]! @ 0xfffffc50 │ │ │ │ @ instruction: 0x46284631 │ │ │ │ mrc2 7, 7, pc, cr12, cr15, {7} │ │ │ │ stmdbcs r0, {r0, r4, r5, r6, r8, fp, sp, lr} │ │ │ │ @ instruction: 0x4628d03a │ │ │ │ mcr2 7, 7, pc, cr0, cr14, {7} @ │ │ │ │ - bcs 2be768 │ │ │ │ + bcs 2be760 │ │ │ │ adchi pc, r3, r0, lsl #4 │ │ │ │ addsmi r2, r3, r1, lsl #6 │ │ │ │ svcvc 0x00e6f413 │ │ │ │ vand d29, d0, d1 │ │ │ │ andsmi r6, r3, #536870915 @ 0x20000003 │ │ │ │ @ instruction: 0xf106bf18 │ │ │ │ @ instruction: 0xf0000118 │ │ │ │ @@ -19704,87 +19702,87 @@ │ │ │ │ @ instruction: 0x46286a31 │ │ │ │ pop {r2, ip, sp, pc} │ │ │ │ @ instruction: 0xf7ff41f0 │ │ │ │ tstcs r0, r5, lsr fp │ │ │ │ vaba.s8 q15, q8, │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ vcgt.s8 d16, d13, d5 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ ldmdavs ip, {r1} │ │ │ │ - blx ffce26b8 │ │ │ │ + blx ffce26b0 │ │ │ │ @ instruction: 0x46026973 │ │ │ │ strtmi r9, [r0], -r2, lsl #6 │ │ │ │ - mvncs pc, sp, asr #12 │ │ │ │ + bicscs pc, ip, sp, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stmib sp, {r0, r1, r4, r5, r7, fp, sp, lr}^ │ │ │ │ vcgt.s8 d22, d0, d0 │ │ │ │ @ instruction: 0xf7ec33c7 │ │ │ │ - smlsld lr, sl, r2, sp │ │ │ │ - blcs 3e8bc <__time64@plt+0x2d5d4> │ │ │ │ + smlsld lr, sl, r6, sp │ │ │ │ + blcs 3e8b4 <__time64@plt+0x2d5cc> │ │ │ │ @ instruction: 0xf8d5d05c │ │ │ │ @ instruction: 0xf1b88000 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf018460f │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ eorle r2, r7, r1, lsl #22 │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3701ed96 │ │ │ │ + @ instruction: 0x3701ed9a │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [r0, #944] @ 0x3b0 │ │ │ │ + ldc 7, cr15, [r4, #944] @ 0x3b0 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -ip, lsl #27] │ │ │ │ + @ instruction: 0x3701ed90 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [r6, #944] @ 0x3b0 │ │ │ │ + stc 7, cr15, [sl, #944] @ 0x3b0 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -r2, lsl #27] │ │ │ │ + strcc lr, [r1, -r6, lsl #27] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldcl 7, cr15, [ip, #-944]! @ 0xfffffc50 │ │ │ │ + stc 7, cr15, [r0, #944] @ 0x3b0 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3701 │ │ │ │ - ldrmi lr, [r8, #3448]! @ 0xd78 │ │ │ │ + ldrmi lr, [r8, #3452]! @ 0xd7c │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r1, r4, r5, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r2, r4, r5, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + ldcl 7, cr15, [r0, #-944]! @ 0xfffffc50 │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [ip, #-944]! @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [r8, #-944]! @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [r4, #-944]! @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [r0, #-944]! @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [ip, #-944] @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [r8, #-944] @ 0xfffffc50 │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - ldcl 7, cr15, [r4, #-944] @ 0xfffffc50 │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ andcs r2, r3, #0, 2 │ │ │ │ vhadd.s8 q11, , │ │ │ │ - vshr.s64 d18, d16, #64 │ │ │ │ + vaddl.s8 q9, d16, d24 │ │ │ │ stmiavs r3!, {r1}^ │ │ │ │ @ instruction: 0xf7ec2101 │ │ │ │ - ldmdavs r2!, {r1, r2, r4, r5, r6, sl, fp, sp, lr, pc} │ │ │ │ + ldmdavs r2!, {r1, r3, r4, r5, r6, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf67f2a0a │ │ │ │ @ instruction: 0xf7ecaf5d │ │ │ │ - vadd.f32 d31, d29, d19 │ │ │ │ - vmlal.s , d0, d0[5] │ │ │ │ + vadd.f32 d31, d29, d23 │ │ │ │ + vmov.i32 , #3072 @ 0x00000c00 │ │ │ │ vhsub.s8 d16, d13, d2 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ teqcs r1, r2 │ │ │ │ - cdp2 7, 6, cr15, cr2, cr12, {7} │ │ │ │ + cdp2 7, 6, cr15, cr6, cr12, {7} │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ strmi r4, [sp], -r6, lsl #12 │ │ │ │ addlt r6, r4, fp, lsl r8 │ │ │ │ @ instruction: 0xf0402b00 │ │ │ │ ldmdavs r3!, {r3, r4, r7, pc}^ │ │ │ │ @@ -19793,63 +19791,63 @@ │ │ │ │ rsble r2, r0, r0, lsl #22 │ │ │ │ ldrdhi pc, [r0], -r6 │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ svceq 0x0000f1b8 │ │ │ │ smlsdcs r0, r7, sp, sp │ │ │ │ movweq pc, #28696 @ 0x7018 @ │ │ │ │ - blcs 98908 │ │ │ │ - blcs d88e8 │ │ │ │ - blcs 1188d0 │ │ │ │ - blcs 1588b8 │ │ │ │ - blcs 1988a0 │ │ │ │ - blcs 1d8888 │ │ │ │ + blcs 98900 │ │ │ │ + blcs d88e0 │ │ │ │ + blcs 1188c8 │ │ │ │ + blcs 1588b0 │ │ │ │ + blcs 198898 │ │ │ │ + blcs 1d8880 │ │ │ │ strcs sp, [r1, -r4] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [r4, #-944] @ 0xfffffc50 │ │ │ │ + stc 7, cr15, [r8, #-944] @ 0xfffffc50 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -r0, lsl #26] │ │ │ │ + strcc lr, [r1, -r4, lsl #26] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldcl 7, cr15, [sl], #944 @ 0x3b0 │ │ │ │ + ldcl 7, cr15, [lr], #944 @ 0x3b0 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3701ecf6 │ │ │ │ + @ instruction: 0x3701ecfa │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldcl 7, cr15, [r0], #944 @ 0x3b0 │ │ │ │ + ldcl 7, cr15, [r4], #944 @ 0x3b0 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r2, r3, r5, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r4, r5, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1, -r0, lsr #32] │ │ │ │ - stcl 7, cr15, [r6], #944 @ 0x3b0 │ │ │ │ + stcl 7, cr15, [sl], #944 @ 0x3b0 │ │ │ │ strhtle r4, [r2], -r8 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stcl 7, cr15, [r0], #944 @ 0x3b0 │ │ │ │ + stcl 7, cr15, [r4], #944 @ 0x3b0 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3708 │ │ │ │ + stmiavs r1!, {r5, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r2, r3, r4, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r3, r4, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r2, r4, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r4, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r2, r3, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r3, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7ec2020 │ │ │ │ - ldrmi lr, [r8, #3268]! @ 0xcc4 │ │ │ │ + ldrmi lr, [r8, #3272]! @ 0xcc8 │ │ │ │ stmiavs r3!, {r2, r3, r4, r6, r7, r8, ip, lr, pc}^ │ │ │ │ mrscs r2, R9_usr │ │ │ │ @ instruction: 0xf64d6072 │ │ │ │ - vmla.i d19, d0, d0[1] │ │ │ │ + vmvn.i32 d19, #12 @ 0x0000000c │ │ │ │ andcs r0, sl, #2 │ │ │ │ - bl ff9628b4 │ │ │ │ - blcs 3edb4 <__time64@plt+0x2dacc> │ │ │ │ + bl ffa628ac │ │ │ │ + blcs 3edac <__time64@plt+0x2dac4> │ │ │ │ adcshi pc, pc, r0, asr #32 │ │ │ │ ldrtmi r4, [r0], -r9, lsr #12 │ │ │ │ ldc2 7, cr15, [sl, #1020]! @ 0x3fc │ │ │ │ @ instruction: 0xb3a96969 │ │ │ │ @ instruction: 0xf7fe4630 │ │ │ │ stmdavs sl!, {r0, r1, r2, r3, r4, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ vpmax.s8 d2, d0, d10 │ │ │ │ @@ -19862,236 +19860,236 @@ │ │ │ │ @ instruction: 0xf0000118 │ │ │ │ @ instruction: 0x46308099 │ │ │ │ pop {r2, ip, sp, pc} │ │ │ │ @ instruction: 0xf7fe41f0 │ │ │ │ vceq.f32 , q8, │ │ │ │ vrsra.s64 , q4, #64 │ │ │ │ vcgt.s8 d16, d13, d5 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ ldmdavs ip, {r1} │ │ │ │ @ instruction: 0xf9b6f7f3 │ │ │ │ strmi r6, [r2], -fp, ror #18 │ │ │ │ strtmi r9, [r0], -r2, lsl #6 │ │ │ │ - tstpcc ip, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpcc r4, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stmib sp, {r0, r1, r3, r5, r7, fp, sp, lr}^ │ │ │ │ vcgt.s8 d21, d0, d0 │ │ │ │ @ instruction: 0xf7ec338f │ │ │ │ - smlald lr, ip, r6, ip │ │ │ │ - blcs 3eb54 <__time64@plt+0x2d86c> │ │ │ │ + smlald lr, ip, sl, ip │ │ │ │ + blcs 3eb4c <__time64@plt+0x2d864> │ │ │ │ @ instruction: 0xf8d6d05c │ │ │ │ @ instruction: 0xf1b88000 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf018460f │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ eorle r2, r7, r1, lsl #22 │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - smlsdcc r1, sl, ip, lr │ │ │ │ + smlsdcc r1, lr, ip, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - mrrc 7, 14, pc, r4, cr12 @ │ │ │ │ + mrrc 7, 14, pc, r8, cr12 @ │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - smlsdcc r1, r0, ip, lr │ │ │ │ + smlsdcc r1, r4, ip, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - mcrr 7, 14, pc, sl, cr12 @ │ │ │ │ + mcrr 7, 14, pc, lr, cr12 @ │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -r6, asr #24] │ │ │ │ + strcc lr, [r1, -sl, asr #24] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - mcrr 7, 14, pc, r0, cr12 @ │ │ │ │ + mcrr 7, 14, pc, r4, cr12 @ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3701 │ │ │ │ - ldrmi lr, [r8, #3132]! @ 0xc3c │ │ │ │ + ldrmi lr, [r8, #3136]! @ 0xc40 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r1, r2, r4, r5, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r3, r4, r5, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + ldc 7, cr15, [r4], #-944 @ 0xfffffc50 │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ ldc 7, cr15, [r0], #-944 @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [ip], #-944 @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r8], #-944 @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r4], #-944 @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r0], #-944 @ 0xfffffc50 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldc 7, cr15, [ip], {236} @ 0xec │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [r8], {236} @ 0xec │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ andcs r2, r3, #0, 2 │ │ │ │ vqadd.s8 q11, , │ │ │ │ - vshr.s64 d18, d16, #64 │ │ │ │ + vaddl.s8 q9, d16, d24 │ │ │ │ stmiavs r3!, {r1}^ │ │ │ │ @ instruction: 0xf7ec2101 │ │ │ │ - stmdavs sl!, {r1, r3, r4, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdavs sl!, {r1, r2, r3, r4, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf67f2a0a │ │ │ │ @ instruction: 0xf7ecaf62 │ │ │ │ - tstpcs r0, r7, ror #24 @ p-variant is OBSOLETE │ │ │ │ + tstpcs r0, fp, ror #24 @ p-variant is OBSOLETE │ │ │ │ andlt r4, r4, r0, lsr r6 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ mrclt 7, 1, APSR_nzcv, cr12, cr14, {7} │ │ │ │ - rsbne pc, r4, #-805306364 @ 0xd0000004 │ │ │ │ + subsne pc, ip, #-805306364 @ 0xd0000004 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ec2131 │ │ │ │ - @ instruction: 0xf64dfd1f │ │ │ │ - vmov.i32 , #0 @ 0x00000000 │ │ │ │ + @ instruction: 0xf64dfd23 │ │ │ │ + vmlal.s , d0, d0[2] │ │ │ │ vhsub.s8 d16, d13, d2 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7ec3193 │ │ │ │ - svclt 0x0000fd13 │ │ │ │ + svclt 0x0000fd17 │ │ │ │ vqrshl.s8 , q12, q8 │ │ │ │ vqdmlal.s , d0, d0[6] │ │ │ │ addmi r0, fp, #335544320 @ 0x14000000 │ │ │ │ stmdavs r3, {r1, r3, r4, r5, r6, r8, ip, lr, pc}^ │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ - blcs 362d4 <__time64@plt+0x24fec> │ │ │ │ + blcs 362cc <__time64@plt+0x24fe4> │ │ │ │ stmdavs r7, {r1, r2, r3, r4, r6, ip, lr, pc} │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ ldclle 15, cr2, [r7, #-0] │ │ │ │ @ instruction: 0xf0172600 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ eorle r2, r7, r1, lsl #22 │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3601ebbc │ │ │ │ + strcc lr, [r1], -r0, asr #23 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl fede2ab4 │ │ │ │ + bl feee2aac │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3601ebb2 │ │ │ │ + @ instruction: 0x3601ebb6 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl feb62ac8 │ │ │ │ + bl fec62ac0 │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1], -r8, lsr #23 │ │ │ │ + strcc lr, [r1], -ip, lsr #23 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl fe8e2adc │ │ │ │ + bl fe9e2ad4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3601 │ │ │ │ - adcsmi lr, r7, #161792 @ 0x27800 │ │ │ │ + adcsmi lr, r7, #165888 @ 0x28800 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r3, r4, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r2, r3, r4, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], -r0, lsr #32 │ │ │ │ + bl fe5e2af4 │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ bl fe4e2afc │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ bl fe3e2b04 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ bl fe2e2b0c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ bl fe1e2b14 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ bl fe0e2b1c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ bl 1fe2b24 │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - bl 1ee2b2c │ │ │ │ ldrhle r4, [ip, #39] @ 0x27 │ │ │ │ andcs r6, r0, r3, ror #17 │ │ │ │ rsbvs r2, r8, r1, lsl #2 │ │ │ │ @ instruction: 0xf64d2209 │ │ │ │ - vmla.i d19, d0, d0[7] │ │ │ │ + vmla.i d19, d0, d0[5] │ │ │ │ @ instruction: 0xf7ec0002 │ │ │ │ - @ instruction: 0x4628ea9c │ │ │ │ + strtmi lr, [r8], -r0, lsr #21 │ │ │ │ msrne (UNDEF: 104), r0 │ │ │ │ smlabteq r5, r0, r2, pc @ │ │ │ │ ldrhtmi lr, [r8], #141 @ 0x8d │ │ │ │ ldcllt 7, cr15, [r0], #-1020 @ 0xfffffc04 │ │ │ │ - rsbscc pc, r8, sp, asr #12 │ │ │ │ + rsbscc pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - ldc2 7, cr15, [r2], #-944 @ 0xfffffc50 │ │ │ │ + ldc2 7, cr15, [r6], #-944 @ 0xfffffc50 │ │ │ │ vqrshl.s8 , q12, q8 │ │ │ │ vsubw.s8 q9, q0, d24 │ │ │ │ addmi r0, fp, #335544320 @ 0x14000000 │ │ │ │ stmdavs r3, {r1, r3, r4, r5, r6, r8, ip, lr, pc}^ │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ - blcs 363e4 <__time64@plt+0x250fc> │ │ │ │ + blcs 363dc <__time64@plt+0x250f4> │ │ │ │ stmdavs r7, {r1, r2, r3, r4, r6, ip, lr, pc} │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ ldclle 15, cr2, [r7, #-0] │ │ │ │ @ instruction: 0xf0172600 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ eorle r2, r7, r1, lsl #22 │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3601eb34 │ │ │ │ + @ instruction: 0x3601eb38 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl be2bc4 │ │ │ │ + bl ce2bbc │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1], -sl, lsr #22 │ │ │ │ + strcc lr, [r1], -lr, lsr #22 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl 962bd8 │ │ │ │ + bl a62bd0 │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1], -r0, lsr #22 │ │ │ │ + strcc lr, [r1], -r4, lsr #22 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - bl 6e2bec │ │ │ │ + bl 7e2be4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3601 │ │ │ │ - adcsmi lr, r7, #22528 @ 0x5800 │ │ │ │ + adcsmi lr, r7, #26624 @ 0x6800 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r4, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r2, r4, r8, r9, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], -r0, lsr #32 │ │ │ │ + bl 3e2c04 │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ bl 2e2c0c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ bl 1e2c14 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ bl e2c1c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ b fffe2c24 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ b ffee2c2c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ b ffde2c34 │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - b ffce2c3c │ │ │ │ ldrhle r4, [ip, #39] @ 0x27 │ │ │ │ andcs r6, r0, r3, ror #17 │ │ │ │ rsbvs r2, r8, r1, lsl #2 │ │ │ │ @ instruction: 0xf64d2207 │ │ │ │ - vmla.i d17, d16, d0[5] │ │ │ │ + vshr.s64 , q6, #64 │ │ │ │ @ instruction: 0xf7ec0002 │ │ │ │ - @ instruction: 0x4628ea14 │ │ │ │ + @ instruction: 0x4628ea18 │ │ │ │ msrcs R8_fiq, r0 │ │ │ │ smlabteq r5, r0, r2, pc @ │ │ │ │ ldrhtmi lr, [r8], #141 @ 0x8d │ │ │ │ - bllt ffa62cb4 │ │ │ │ - adccc pc, r8, sp, asr #12 │ │ │ │ + bllt ffa62cac │ │ │ │ + adccc pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx feae2c76 │ │ │ │ + blx febe2c6e │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ @ instruction: 0x460441f0 │ │ │ │ - blcs 36508 <__time64@plt+0x25220> │ │ │ │ + blcs 36500 <__time64@plt+0x25218> │ │ │ │ @ instruction: 0xf8d0d060 │ │ │ │ @ instruction: 0xf1b88000 │ │ │ │ ldclle 15, cr0, [fp, #-0] │ │ │ │ ldrvc pc, [r0, #-576]! @ 0xfffffdc0 │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ @ instruction: 0xf0182700 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -20099,82 +20097,82 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3701eab2 │ │ │ │ + @ instruction: 0x3701eab6 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - b feb62cc8 │ │ │ │ + b fec62cc0 │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -r8, lsr #21] │ │ │ │ + strcc lr, [r1, -ip, lsr #21] │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - b fe8e2cdc │ │ │ │ + b fe9e2cd4 │ │ │ │ stmiavs r9!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3701ea9e │ │ │ │ + strcc lr, [r1, -r2, lsr #21] │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ - b fe662cf0 │ │ │ │ + b fe762ce8 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ @ instruction: 0xf7ec3701 │ │ │ │ - ldrmi lr, [r8, #2708]! @ 0xa94 │ │ │ │ + ldrmi lr, [r8, #2712]! @ 0xa98 │ │ │ │ stmiavs r9!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r9!, {r1, r2, r3, r7, r9, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r9!, {r1, r4, r7, r9, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + b fe362d08 │ │ │ │ + eorcs r6, r0, r9, ror #17 │ │ │ │ b fe262d10 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ b fe162d18 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ b fe062d20 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ b 1f62d28 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ b 1e62d30 │ │ │ │ eorcs r6, r0, r9, ror #17 │ │ │ │ b 1d62d38 │ │ │ │ - eorcs r6, r0, r9, ror #17 │ │ │ │ - b 1c62d40 │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ @ instruction: 0x13a8f240 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ addsmi r2, lr, #0, 4 │ │ │ │ andsle r6, r8, r2, rrx │ │ │ │ mvnne pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xd125429e │ │ │ │ teqpvc r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ andcs r2, ip, #1073741824 @ 0x40000000 │ │ │ │ - rsccc pc, r4, sp, asr #12 │ │ │ │ + sbcscc pc, ip, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ec68db │ │ │ │ - ldrtmi lr, [r1], -r2, lsl #19 │ │ │ │ + ldrtmi lr, [r1], -r6, lsl #19 │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7ff41f0 │ │ │ │ vpadd.i8 , q0, │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ tstcs r1, r5, lsl #6 │ │ │ │ @ instruction: 0xf64d220f │ │ │ │ - vshr.s64 , q2, #64 │ │ │ │ + vmla.i d19, d16, d0[3] │ │ │ │ ldmvs fp, {r1}^ │ │ │ │ - stmdb lr!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdb r2!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x46204631 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ - bllt 11e2df8 │ │ │ │ - rscscc pc, r4, sp, asr #12 │ │ │ │ + bllt 11e2df0 │ │ │ │ + rsccc pc, ip, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - blx 262dba │ │ │ │ + blx 362db2 │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ vand q10, q8, q8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strmi r0, [r5], -r5, lsl #8 │ │ │ │ - blcs 36654 <__time64@plt+0x2536c> │ │ │ │ + blcs 3664c <__time64@plt+0x25364> │ │ │ │ @ instruction: 0xf8d0d060 │ │ │ │ vhadd.s8 d24, d0, d0 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf1b80405 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf0182700 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -20182,54 +20180,54 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -ip, lsl #20] │ │ │ │ + smladcc r1, r0, sl, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - b 1e2e14 │ │ │ │ + b 2e2e0c │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -r2, lsl #20] │ │ │ │ + strcc lr, [r1, -r6, lsl #20] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmib ip!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + b 62e20 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3701e9f8 │ │ │ │ + @ instruction: 0x3701e9fc │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmib r2!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmib r6!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3701 │ │ │ │ - ldrmi lr, [r8, #2542]! @ 0x9ee │ │ │ │ + ldrmi lr, [r8, #2546]! @ 0x9f2 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r3, r5, r6, r7, r8, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r2, r3, r5, r6, r7, r8, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + stmib r6!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ stmib r2!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmib lr, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmib sl, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmib r6, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmib r2, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmib lr, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - stmib sl, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ andcs r6, r0, #14876672 @ 0xe30000 │ │ │ │ rsbvs r2, sl, r1, lsl #2 │ │ │ │ - eormi pc, r0, sp, asr #12 │ │ │ │ + andsmi pc, r8, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ec2206 │ │ │ │ - ldrtmi lr, [r1], -ip, ror #17 │ │ │ │ + @ instruction: 0x4631e8f0 │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ ldmibvs r1!, {r0, r2, r6, r7, r9, fp, ip, sp, lr, pc} │ │ │ │ rsble r2, pc, r0, lsl #18 │ │ │ │ @ instruction: 0xf7fe4628 │ │ │ │ stmdavs fp!, {r0, r3, r5, r7, r9, fp, ip, sp, lr, pc}^ │ │ │ │ subsle r2, sp, r0, lsl #22 │ │ │ │ @ instruction: 0xf103682b │ │ │ │ @@ -20241,114 +20239,114 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3701e996 │ │ │ │ + @ instruction: 0x3701e99a │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmib r0, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib r4, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -ip, lsl #19] │ │ │ │ + @ instruction: 0x3701e990 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmib r6, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmib sl, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -r2, lsl #19] │ │ │ │ + strcc lr, [r1, -r6, lsl #19] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmdb ip!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib r0, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3701 │ │ │ │ - ldrmi lr, [r8, #2424]! @ 0x978 │ │ │ │ + ldrmi lr, [r8, #2428]! @ 0x97c │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r1, r4, r5, r6, r8, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r2, r4, r5, r6, r8, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + ldmdb r0!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ stmdb ip!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdb r8!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdb r4!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdb r0!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmdb ip, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmdb r8, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmdb r4, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ movwcs r6, #2273 @ 0x8e1 │ │ │ │ rsbvs r2, fp, r0, lsr #32 │ │ │ │ - stmdb ip, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdb r0, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x46286971 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ stmialt lr!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blcs 3f194 <__time64@plt+0x2deac> │ │ │ │ + blcs 3f18c <__time64@plt+0x2dea4> │ │ │ │ stmdavs fp!, {r0, r2, r3, r4, r6, ip, lr, pc} │ │ │ │ ldmcc pc!, {r0, r1, r8, ip, sp, lr, pc}^ @ │ │ │ │ svceq 0x0000f1b8 │ │ │ │ @ instruction: 0x460fdd57 │ │ │ │ movweq pc, #28696 @ 0x7018 @ │ │ │ │ - blcs 990c0 │ │ │ │ - blcs d90a0 │ │ │ │ - blcs 119088 │ │ │ │ - blcs 159070 │ │ │ │ - blcs 199058 │ │ │ │ - blcs 1d9040 │ │ │ │ + blcs 990b8 │ │ │ │ + blcs d9098 │ │ │ │ + blcs 119080 │ │ │ │ + blcs 159068 │ │ │ │ + blcs 199050 │ │ │ │ + blcs 1d9038 │ │ │ │ strcs sp, [r1, -r4] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmdb r8!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb ip!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1, -r4, lsr #18] │ │ │ │ + strcc lr, [r1, -r8, lsr #18] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmdb lr, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r2!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - smladcc r1, sl, r9, lr │ │ │ │ + smladcc r1, lr, r9, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmdb r4, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmdb r8, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r4, r8, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r2, r4, r8, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1, -r0, lsr #32] │ │ │ │ - stmdb sl, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb lr, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ strhtle r4, [r2], -r8 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmdb r4, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r8, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3708 │ │ │ │ + stmiavs r1!, {r2, r8, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r8, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r2, r3, r4, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r3, r4, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r2, r4, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ stmiavs r1!, {r4, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r2, r3, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7ec2020 │ │ │ │ - ldrmi lr, [r8, #2280]! @ 0x8e8 │ │ │ │ + ldrmi lr, [r8, #2284]! @ 0x8ec │ │ │ │ andcs sp, r0, #220, 2 @ 0x37 │ │ │ │ rsbvs r6, sl, r3, ror #17 │ │ │ │ andcs r2, r4, #1073741824 @ 0x40000000 │ │ │ │ - eormi pc, r8, sp, asr #12 │ │ │ │ + eormi pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - stmda r8, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda ip, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ svclt 0x0000e725 │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ vand q10, q8, q8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strmi r0, [r5], -r5, lsl #8 │ │ │ │ - blcs 36910 <__time64@plt+0x25628> │ │ │ │ + blcs 36908 <__time64@plt+0x25620> │ │ │ │ @ instruction: 0xf8d0d060 │ │ │ │ vhadd.s8 d24, d0, d0 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf1b80405 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf0182600 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -20356,202 +20354,202 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3601e8b0 │ │ │ │ + @ instruction: 0x3601e8b4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmia sl!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmia lr!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - strcc lr, [r1], -r6, lsr #17 │ │ │ │ + strcc lr, [r1], -sl, lsr #17 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmia r0!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmia r4!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - @ instruction: 0x3601e89c │ │ │ │ + strcc lr, [r1], -r0, lsr #17 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldm r6, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldm sl, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7ec3601 │ │ │ │ - ldrmi lr, [r0, #2194]! @ 0x892 │ │ │ │ + ldrmi lr, [r0, #2198]! @ 0x896 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7ec2020 │ │ │ │ - stmiavs r1!, {r2, r3, r7, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r4, r7, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], -r0, lsr #32 │ │ │ │ + stm sl, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ stm r6, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stm r2, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmda lr!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmda sl!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmda r6!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmda r2!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - stmda lr!, {r2, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrhle r4, [ip, #80] @ 0x50 │ │ │ │ smlattcs r0, r3, r8, r6 │ │ │ │ rsbvs r2, r9, r8, lsl #4 │ │ │ │ - eorsmi pc, r0, sp, asr #12 │ │ │ │ + eormi pc, r8, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7eb2101 │ │ │ │ - shadd8mi lr, r9, r0 │ │ │ │ + shadd8mi lr, r9, r4 │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ ldmdbvs r9!, {r0, r3, r5, r6, r8, fp, ip, sp, lr, pc}^ │ │ │ │ pop {r3, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7fe41f0 │ │ │ │ svclt 0x0000bfbf │ │ │ │ svcmi 0x00f0e92d │ │ │ │ - bcc ffe61acc │ │ │ │ - beq 1a1cd0 │ │ │ │ + bcc ffe61ac4 │ │ │ │ + beq 1a1cc8 │ │ │ │ vhadd.s8 d27, d29, d9 │ │ │ │ - vrshr.s64 q10, q8, #64 │ │ │ │ + vmlal.s q10, d16, d0[6] │ │ │ │ strmi r0, [r7], -r2, lsl #4 │ │ │ │ @ instruction: 0xf7fe4688 │ │ │ │ @ instruction: 0xf8dafdff │ │ │ │ - blcs 311e8 <__time64@plt+0x1ff00> │ │ │ │ + blcs 311e0 <__time64@plt+0x1fef8> │ │ │ │ adchi pc, r2, r0, asr #32 │ │ │ │ ldrdmi pc, [ip], -r8 @ │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ @ instruction: 0x260080bc │ │ │ │ bicscc pc, r8, r0, asr #4 │ │ │ │ smlabteq r5, r0, r2, pc @ │ │ │ │ @ instruction: 0x46b14635 │ │ │ │ vmax.s8 d20, d29, d11 │ │ │ │ - vmov.i64 , #0x0000000000ff0000 │ │ │ │ + vqrdmlah.s d17, d0, d0[7] │ │ │ │ @ instruction: 0xf64d0e02 │ │ │ │ - vmov.i32 q10, #3327 @ 0x00000cff │ │ │ │ + vmov.i32 q10, #1279 @ 0x000004ff │ │ │ │ strls r0, [r7, -r2, lsl #24] │ │ │ │ andsge pc, r0, sp, asr #17 │ │ │ │ @ instruction: 0xec05e9cd │ │ │ │ strcc r9, [r1, #-2820] @ 0xfffff4fc │ │ │ │ ldmiblt lr, {r1, r2, r3, r4, fp, sp, lr} │ │ │ │ @ instruction: 0xf1a36823 │ │ │ │ - bcs 65a54 │ │ │ │ - blcc 15b6d4 │ │ │ │ + bcs 65a4c │ │ │ │ + blcc 15b6cc │ │ │ │ stmdble r5!, {r0, r8, r9, fp, sp} │ │ │ │ - addmi pc, r8, #80740352 @ 0x4d00000 │ │ │ │ + addmi pc, r0, #80740352 @ 0x4d00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ mvnscc pc, r0, asr #4 │ │ │ │ - @ instruction: 0xf93cf7ec │ │ │ │ + @ instruction: 0xf940f7ec │ │ │ │ @ instruction: 0xf8db9805 │ │ │ │ @ instruction: 0xf7f2a000 │ │ │ │ stmdbvs r3!, {r0, r1, r3, r4, r5, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ movwls r4, #13826 @ 0x3602 │ │ │ │ vmin.s8 q10, q0, q0 │ │ │ │ stmdbls r6, {r1, r4, r5, r6, r7, r8, r9, ip, sp} │ │ │ │ stmib sp, {r0, r1, r2, r5, r7, fp, sp, lr}^ │ │ │ │ strls r4, [r0, #-1793] @ 0xfffff8ff │ │ │ │ - svc 0x009cf7eb │ │ │ │ + svc 0x00a0f7eb │ │ │ │ @ instruction: 0xf1a36823 │ │ │ │ - blcc 125aa0 │ │ │ │ + blcc 125a98 │ │ │ │ svclt 0x00882b01 │ │ │ │ ldmle r9, {r0, r9, fp, sp}^ │ │ │ │ strbmi r6, [r3, #-2787] @ 0xfffff51d │ │ │ │ stmdbvs r1!, {r0, r1, r4, r5, r6, r8, ip, lr, pc}^ │ │ │ │ svceq 0x0000f1b9 │ │ │ │ strbmi sp, [r8], -r8, asr #32 │ │ │ │ - cdp 7, 10, cr15, cr8, cr11, {7} │ │ │ │ + cdp 7, 10, cr15, cr12, cr11, {7} │ │ │ │ cmnle r6, r0, lsl #16 │ │ │ │ stccs 8, cr6, [r0], {100} @ 0x64 │ │ │ │ cdpcs 0, 0, cr13, cr0, cr4, {2} │ │ │ │ svcls 0x0007d1bc │ │ │ │ and r4, r6, lr, asr #12 │ │ │ │ @ instruction: 0xf7eb4630 │ │ │ │ - stmdacs r0, {r2, r3, r4, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r5, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ stmdavs r4!, {r0, r3, r5, r6, r8, ip, lr, pc}^ │ │ │ │ stmdavs r3!, {r2, r3, r7, r8, ip, sp, pc} │ │ │ │ svcne 0x001a3501 │ │ │ │ - blcs 73ee8 │ │ │ │ - bcs 950e8 │ │ │ │ - bvs ff91b5a4 │ │ │ │ + blcs 73ee0 │ │ │ │ + bcs 950e0 │ │ │ │ + bvs ff91b59c │ │ │ │ @ instruction: 0xd1504598 │ │ │ │ @ instruction: 0x2e006961 │ │ │ │ stmdavs r4!, {r1, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ stccs 6, cr4, [r0], {14} │ │ │ │ ldrtmi sp, [r8], -sp, ror #3 │ │ │ │ - @ instruction: 0x41a8f64d │ │ │ │ + asrmi pc, sp, #12 @ │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xffb4f7fd │ │ │ │ teqpvc r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf64d462a │ │ │ │ - vbic.i32 d16, #8 @ 0x00000008 │ │ │ │ + vbic.i32 d16, #0 @ 0x00000000 │ │ │ │ ldmvs r8, {r1, r8}^ │ │ │ │ - svc 0x0054f7eb │ │ │ │ + svc 0x0058f7eb │ │ │ │ ldrdmi pc, [ip], -r8 @ │ │ │ │ @ instruction: 0x4621b134 │ │ │ │ @ instruction: 0xf7fe4638 │ │ │ │ stmdavs r4!, {r0, r1, r2, r4, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ andlt r4, r9, r8, lsr r6 │ │ │ │ svcmi 0x00f0e8bd │ │ │ │ stmdalt r0!, {r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ strmi r6, [r9], r4, ror #16 │ │ │ │ @ instruction: 0xd1ba2c00 │ │ │ │ ldrb r9, [r6, r7, lsl #30] │ │ │ │ bicscc pc, r8, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7f2681c │ │ │ │ @ instruction: 0xf8cdfcc5 │ │ │ │ strmi r8, [r2], -r0 │ │ │ │ - teqpmi ip, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqpmi r4, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldrdcc pc, [r8], -r8 │ │ │ │ movwls r4, #5664 @ 0x1620 │ │ │ │ mvncc pc, #64, 4 │ │ │ │ - svc 0x0024f7eb │ │ │ │ + svc 0x0028f7eb │ │ │ │ ldrdmi pc, [ip], -r8 @ │ │ │ │ @ instruction: 0xf47f2c00 │ │ │ │ strtmi sl, [r5], -r4, asr #30 │ │ │ │ @ instruction: 0xf64de7b5 │ │ │ │ - vsubl.s8 q10, d16, d8 │ │ │ │ + vsubl.s8 q10, d16, d0 │ │ │ │ vhsub.s8 d16, d13, d2 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7ec31f6 │ │ │ │ - @ instruction: 0xf64df89f │ │ │ │ - vsubl.s8 q10, d16, d8 │ │ │ │ + @ instruction: 0xf64df8a3 │ │ │ │ + vsubl.s8 q10, d16, d0 │ │ │ │ vhsub.s8 d16, d13, d2 │ │ │ │ - vmvn.i32 , #4 @ 0x00000004 │ │ │ │ + vmla.i d17, d0, d0[7] │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7ec31f9 │ │ │ │ - svclt 0x0000f893 │ │ │ │ + svclt 0x0000f897 │ │ │ │ @ instruction: 0x460db538 │ │ │ │ vmax.s8 d20, d9, d4 │ │ │ │ - vmlal.s , d16, d0[3] │ │ │ │ + vmlal.s , d16, d0[1] │ │ │ │ @ instruction: 0xf7fe0202 │ │ │ │ - bvs ffaa480c │ │ │ │ + bvs ffaa4804 │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7fe4038 │ │ │ │ svclt 0x0000bebf │ │ │ │ @ instruction: 0x460db538 │ │ │ │ @ instruction: 0xf64c4604 │ │ │ │ - vrshr.s64 , q0, #64 │ │ │ │ + vmlal.s , d16, d0[2] │ │ │ │ @ instruction: 0xf7fe0202 │ │ │ │ - bvs ffaa47ec │ │ │ │ + bvs ffaa47e4 │ │ │ │ @ instruction: 0xf7fe4620 │ │ │ │ - blvs aa4ea4 │ │ │ │ + blvs aa4e9c │ │ │ │ pop {r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7fe4038 │ │ │ │ svclt 0x0000beab │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ vand q10, q8, q8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strmi r0, [r5], -r5, lsl #8 │ │ │ │ - blcs 36c38 <__time64@plt+0x25950> │ │ │ │ + blcs 36c30 <__time64@plt+0x25948> │ │ │ │ @ instruction: 0xf8d0d060 │ │ │ │ vhadd.s8 d24, d0, d0 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf1b80405 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf0182700 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -20559,180 +20557,180 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - smladcc r1, sl, pc, lr @ │ │ │ │ + smladcc r1, lr, pc, lr @ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x0014f7eb │ │ │ │ + svc 0x0018f7eb │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - smladcc r1, r0, pc, lr @ │ │ │ │ + smladcc r1, r4, pc, lr @ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x000af7eb │ │ │ │ + svc 0x000ef7eb │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1, -r6, lsl #30] │ │ │ │ + strcc lr, [r1, -sl, lsl #30] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - svc 0x0000f7eb │ │ │ │ + svc 0x0004f7eb │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7eb3701 │ │ │ │ - ldrmi lr, [r8, #3836]! @ 0xefc │ │ │ │ + ldrmi lr, [r8, #3840]! @ 0xf00 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r1, r2, r4, r5, r6, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r3, r4, r5, r6, r7, r9, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + cdp 7, 15, cr15, cr4, cr11, {7} │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 15, cr15, cr0, cr11, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 14, cr15, cr12, cr11, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 14, cr15, cr8, cr11, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 14, cr15, cr4, cr11, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 14, cr15, cr0, cr11, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ cdp 7, 13, cr15, cr12, cr11, {7} │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 13, cr15, cr8, cr11, {7} │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ andcs r6, r0, #14876672 @ 0xe30000 │ │ │ │ rsbvs r2, sl, r1, lsl #2 │ │ │ │ - adcsmi pc, r4, sp, asr #12 │ │ │ │ + adcmi pc, ip, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7eb2207 │ │ │ │ - ldmvs r3!, {r1, r3, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmvs r3!, {r1, r2, r3, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ ldmdavs r9, {r3, r5, r9, sl, lr} │ │ │ │ mcr2 7, 1, pc, cr14, cr14, {7} @ │ │ │ │ ldmvs r9, {r0, r1, r4, r5, r6, r7, fp, sp, lr} │ │ │ │ @ instruction: 0x4628b151 │ │ │ │ @ instruction: 0xffb6f7fd │ │ │ │ ldmdavs r9, {r0, r1, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ @ instruction: 0x4628b1b1 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ svclt 0x00aef7fd │ │ │ │ - blcs 3f6b0 <__time64@plt+0x2e3c8> │ │ │ │ + blcs 3f6a8 <__time64@plt+0x2e3c0> │ │ │ │ stmiavs r3!, {r1, r3, r4, r5, r6, r8, ip, lr, pc}^ │ │ │ │ mrscs r2, R9_usr │ │ │ │ @ instruction: 0xf64d606a │ │ │ │ - vmla.i d17, d16, d0[7] │ │ │ │ + vmla.i d17, d16, d0[5] │ │ │ │ andcs r0, r5, #2 │ │ │ │ - ldcl 7, cr15, [r8, #940] @ 0x3ac │ │ │ │ + ldcl 7, cr15, [ip, #940] @ 0x3ac │ │ │ │ ldmdavs r9, {r0, r1, r4, r5, r6, r7, fp, sp, lr}^ │ │ │ │ mvnle r2, r0, lsl #18 │ │ │ │ - blcs 3f6d4 <__time64@plt+0x2e3ec> │ │ │ │ + blcs 3f6cc <__time64@plt+0x2e3e4> │ │ │ │ stmdavs pc!, {r0, r1, r3, r4, r6, ip, lr, pc} @ │ │ │ │ svccs 0x00003f01 │ │ │ │ @ instruction: 0x2600dd57 │ │ │ │ movweq pc, #28695 @ 0x7017 @ │ │ │ │ - blcs 995fc │ │ │ │ - blcs d95dc │ │ │ │ - blcs 1195c4 │ │ │ │ - blcs 1595ac │ │ │ │ - blcs 199594 │ │ │ │ - blcs 1d957c │ │ │ │ + blcs 995f4 │ │ │ │ + blcs d95d4 │ │ │ │ + blcs 1195bc │ │ │ │ + blcs 1595a4 │ │ │ │ + blcs 19958c │ │ │ │ + blcs 1d9574 │ │ │ │ strcs sp, [r1], -r4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 8, cr15, cr10, cr11, {7} │ │ │ │ + cdp 7, 8, cr15, cr14, cr11, {7} │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1], -r6, lsl #29 │ │ │ │ + strcc lr, [r1], -sl, lsl #29 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 8, cr15, cr0, cr11, {7} │ │ │ │ + cdp 7, 8, cr15, cr4, cr11, {7} │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0x3601ee7c │ │ │ │ + strcc lr, [r1], -r0, lsl #29 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 7, cr15, cr6, cr11, {7} │ │ │ │ + cdp 7, 7, cr15, cr10, cr11, {7} │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r1, r4, r5, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r2, r4, r5, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1], -r0, lsr #32 │ │ │ │ - cdp 7, 6, cr15, cr12, cr11, {7} │ │ │ │ + cdp 7, 7, cr15, cr0, cr11, {7} │ │ │ │ strhtle r4, [r2], -r7 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 6, cr15, cr6, cr11, {7} │ │ │ │ + cdp 7, 6, cr15, cr10, cr11, {7} │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7eb3608 │ │ │ │ + stmiavs r1!, {r1, r2, r5, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + @ instruction: 0xf7eb2020 │ │ │ │ stmiavs r1!, {r1, r5, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ stmiavs r1!, {r1, r2, r3, r4, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ stmiavs r1!, {r1, r3, r4, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ stmiavs r1!, {r1, r2, r4, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ stmiavs r1!, {r1, r4, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r1, r2, r3, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ - @ instruction: 0xf7eb2020 │ │ │ │ - adcsmi lr, r7, #1184 @ 0x4a0 │ │ │ │ + adcsmi lr, r7, #1248 @ 0x4e0 │ │ │ │ ldrdcs sp, [r0, -ip] │ │ │ │ rsbvs r6, r9, r3, ror #17 │ │ │ │ - rscne pc, ip, sp, asr #12 │ │ │ │ + rscne pc, r4, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ pop {r0, r2, r9, sp} │ │ │ │ strdcs r4, [r1, -r0] │ │ │ │ - stcllt 7, cr15, [r6, #-940]! @ 0xfffffc54 │ │ │ │ + stcllt 7, cr15, [sl, #-940]! @ 0xfffffc54 │ │ │ │ @ instruction: 0xf103682b │ │ │ │ @ instruction: 0xf1b838ff │ │ │ │ @ instruction: 0xf77f0f00 │ │ │ │ @ instruction: 0x460faf7e │ │ │ │ movweq pc, #28696 @ 0x7018 @ │ │ │ │ - blcs 996d8 │ │ │ │ - blcs d96b4 │ │ │ │ - blcs 11969c │ │ │ │ - blcs 159684 │ │ │ │ - blcs 19966c │ │ │ │ - blcs 1d9654 │ │ │ │ + blcs 996d0 │ │ │ │ + blcs d96ac │ │ │ │ + blcs 119694 │ │ │ │ + blcs 15967c │ │ │ │ + blcs 199664 │ │ │ │ + blcs 1d964c │ │ │ │ strcs sp, [r1, -r4] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 1, cr15, cr14, cr11, {7} │ │ │ │ + cdp 7, 2, cr15, cr2, cr11, {7} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - smladcc r1, sl, lr, lr │ │ │ │ + smladcc r1, lr, lr, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 1, cr15, cr4, cr11, {7} │ │ │ │ + cdp 7, 1, cr15, cr8, cr11, {7} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - smladcc r1, r0, lr, lr │ │ │ │ + smladcc r1, r4, lr, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - cdp 7, 0, cr15, cr10, cr11, {7} │ │ │ │ + cdp 7, 0, cr15, cr14, cr11, {7} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r1, r2, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r3, r9, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r1, -r0, lsr #32] │ │ │ │ - cdp 7, 0, cr15, cr0, cr11, {7} │ │ │ │ + cdp 7, 0, cr15, cr4, cr11, {7} │ │ │ │ @ instruction: 0xf43f45b8 │ │ │ │ stmiavs r1!, {r3, r6, r8, r9, sl, fp, sp, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r1, r3, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r2, r3, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + ldcl 7, cr15, [r8, #940]! @ 0x3ac │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [r4, #940]! @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [r0, #940]! @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [ip, #940]! @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [r8, #940]! @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [r4, #940]! @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [r0, #940]! @ 0x3ac │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - ldcl 7, cr15, [ip, #940] @ 0x3ac │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ svclt 0x0000e723 │ │ │ │ push {r0, r1, r6, fp, sp, lr} │ │ │ │ vand q10, q8, q8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ strmi r0, [r5], -r5, lsl #8 │ │ │ │ - blcs 36f10 <__time64@plt+0x25c28> │ │ │ │ + blcs 36f08 <__time64@plt+0x25c20> │ │ │ │ @ instruction: 0xf8d0d060 │ │ │ │ vhadd.s8 d24, d0, d0 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf1b80405 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf0182600 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -20740,63 +20738,63 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0x3601edb0 │ │ │ │ + @ instruction: 0x3601edb4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [sl, #940]! @ 0x3ac │ │ │ │ + stc 7, cr15, [lr, #940]! @ 0x3ac │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1], -r6, lsr #27 │ │ │ │ + strcc lr, [r1], -sl, lsr #27 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [r0, #940]! @ 0x3ac │ │ │ │ + stc 7, cr15, [r4, #940]! @ 0x3ac │ │ │ │ stmiavs r1!, {r0, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0x3601ed9c │ │ │ │ + strcc lr, [r1], -r0, lsr #27 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [r6, #940] @ 0x3ac │ │ │ │ + ldc 7, cr15, [sl, #940] @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7eb3601 │ │ │ │ - ldrmi lr, [r0, #3474]! @ 0xd92 │ │ │ │ + ldrmi lr, [r0, #3478]! @ 0xd96 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r2, r3, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r4, r7, r8, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], -r0, lsr #32 │ │ │ │ + stc 7, cr15, [sl, #940] @ 0x3ac │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r6, #940] @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r2, #940] @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [lr, #-940]! @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [sl, #-940]! @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [r6, #-940]! @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [r2, #-940]! @ 0xfffffc54 │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - stcl 7, cr15, [lr, #-940]! @ 0xfffffc54 │ │ │ │ ldrhle r4, [ip, #80] @ 0x50 │ │ │ │ smlattcs r0, r3, r8, r6 │ │ │ │ rsbvs r2, r9, r5, lsl #4 │ │ │ │ - adcsmi pc, ip, sp, asr #12 │ │ │ │ + adcsmi pc, r4, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7eb2101 │ │ │ │ - ldmvs r9!, {r4, r7, sl, fp, sp, lr, pc}^ │ │ │ │ + ldmvs r9!, {r2, r4, r7, sl, fp, sp, lr, pc}^ │ │ │ │ pop {r3, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7fe41f0 │ │ │ │ svclt 0x0000bcc3 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ strmi r4, [lr], -r5, lsl #12 │ │ │ │ - bicvs pc, r0, sp, asr #4 │ │ │ │ + @ instruction: 0x61b8f24d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ stc2l 7, cr15, [r2, #-1012] @ 0xfffffc0c │ │ │ │ - blcs 3f980 <__time64@plt+0x2e698> │ │ │ │ + blcs 3f978 <__time64@plt+0x2e690> │ │ │ │ @ instruction: 0xf8d5d061 │ │ │ │ @ instruction: 0xf1b88000 │ │ │ │ ldclle 15, cr0, [ip, #-0] │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ @ instruction: 0xf0182700 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ @@ -20804,140 +20802,140 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - smladxcc r1, r0, sp, lr │ │ │ │ + smladxcc r1, r4, sp, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [sl, #-940]! @ 0xfffffc54 │ │ │ │ + stc 7, cr15, [lr, #-940]! @ 0xfffffc54 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1, -r6, lsr #26] │ │ │ │ + strcc lr, [r1, -sl, lsr #26] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [r0, #-940]! @ 0xfffffc54 │ │ │ │ + stc 7, cr15, [r4, #-940]! @ 0xfffffc54 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - smladcc r1, ip, sp, lr │ │ │ │ + strcc lr, [r1, -r0, lsr #26] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [r6, #-940] @ 0xfffffc54 │ │ │ │ + ldc 7, cr15, [sl, #-940] @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7eb3701 │ │ │ │ - ldrmi lr, [r8, #3346]! @ 0xd12 │ │ │ │ + ldrmi lr, [r8, #3350]! @ 0xd16 │ │ │ │ stmiavs r1!, {r0, r1, r2, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r2, r3, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r4, r8, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + stc 7, cr15, [sl, #-940] @ 0xfffffc54 │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r6, #-940] @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stc 7, cr15, [r2, #-940] @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [lr], #940 @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [sl], #940 @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [r6], #940 @ 0x3ac │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [r2], #940 @ 0x3ac │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - stcl 7, cr15, [lr], #940 @ 0x3ac │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ vhadd.s8 d30, d0, d3 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ ldmdavs r2!, {r0, r2, sl}^ │ │ │ │ stmiavs r0!, {r8, r9, sp}^ │ │ │ │ mvnslt r6, fp, rrx │ │ │ │ - orrscs pc, r0, sp, asr #12 │ │ │ │ + orrcs pc, r8, sp, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldcl 7, cr15, [sl], #-940 @ 0xfffffc54 │ │ │ │ - blcs bfb88 │ │ │ │ - blcs 119948 │ │ │ │ + ldcl 7, cr15, [lr], #-940 @ 0xfffffc54 │ │ │ │ + blcs bfb80 │ │ │ │ + blcs 119940 │ │ │ │ strtmi sp, [r8], -r8, lsl #2 │ │ │ │ @ instruction: 0xf7ff4631 │ │ │ │ @ instruction: 0x4628fd91 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ stcllt 7, cr15, [r8, #-1012] @ 0xfffffc0c │ │ │ │ @ instruction: 0xf0402b01 │ │ │ │ strtmi r8, [r8], -r9, lsl #1 │ │ │ │ @ instruction: 0xf7fd4631 │ │ │ │ qsaxmi pc, r8, r5 @ │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ ldclt 7, cr15, [ip, #-1012]! @ 0xfffffc0c │ │ │ │ andcs r4, r4, #3145728 @ 0x300000 │ │ │ │ @ instruction: 0xf64d2101 │ │ │ │ - vshr.s64 , q6, #64 │ │ │ │ + vshr.s64 , q2, #64 │ │ │ │ @ instruction: 0xf7eb0002 │ │ │ │ - ldmvs r3!, {r3, r5, r6, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ + ldmvs r3!, {r2, r3, r5, r6, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ bicsle r2, ip, r2, lsl #22 │ │ │ │ - blcs 3fab4 <__time64@plt+0x2e7cc> │ │ │ │ + blcs 3faac <__time64@plt+0x2e7c4> │ │ │ │ @ instruction: 0xf8d5d05c │ │ │ │ @ instruction: 0xf1b88000 │ │ │ │ ldclle 15, cr0, [r7, #-0] │ │ │ │ @ instruction: 0xf0182700 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ eorle r2, r7, r1, lsl #22 │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0x3701ec9a │ │ │ │ + @ instruction: 0x3701ec9e │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldc 7, cr15, [r4], {235} @ 0xeb │ │ │ │ + ldc 7, cr15, [r8], {235} @ 0xeb │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0x3701ec90 │ │ │ │ + @ instruction: 0x3701ec94 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [sl], {235} @ 0xeb │ │ │ │ + stc 7, cr15, [lr], {235} @ 0xeb │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1, -r6, lsl #25] │ │ │ │ + strcc lr, [r1, -sl, lsl #25] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stc 7, cr15, [r0], {235} @ 0xeb │ │ │ │ + stc 7, cr15, [r4], {235} @ 0xeb │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7eb3701 │ │ │ │ - ldrmi lr, [r8, #3196]! @ 0xc7c │ │ │ │ + ldrmi lr, [r8, #3200]! @ 0xc80 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r1, r2, r4, r5, r6, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r3, r4, r5, r6, sl, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + ldcl 7, cr15, [r4], #-940 @ 0xfffffc54 │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ ldcl 7, cr15, [r0], #-940 @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [ip], #-940 @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [r8], #-940 @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [r4], #-940 @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stcl 7, cr15, [r0], #-940 @ 0xfffffc54 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ mrrc 7, 14, pc, ip, cr11 @ │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - mrrc 7, 14, pc, r8, cr11 @ │ │ │ │ ldrhle r4, [ip, #88] @ 0x58 │ │ │ │ smlattcs r0, r3, r8, r6 │ │ │ │ rsbvs r2, r9, r5, lsl #4 │ │ │ │ - adcsmi pc, ip, sp, asr #12 │ │ │ │ + adcsmi pc, r4, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7eb2101 │ │ │ │ - @ instruction: 0x4628eb7a │ │ │ │ + @ instruction: 0x4628eb7e │ │ │ │ @ instruction: 0xf7fe68f1 │ │ │ │ strtmi pc, [r8], -pc, lsr #23 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ ldclt 7, cr15, [ip], #1012 @ 0x3f4 │ │ │ │ - sbcmi pc, r4, sp, asr #12 │ │ │ │ + adcsmi pc, ip, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - ldc2 7, cr15, [r0, #-940] @ 0xfffffc54 │ │ │ │ + ldc2 7, cr15, [r4, #-940] @ 0xfffffc54 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ strmi r4, [ip], -r5, lsl #12 │ │ │ │ @ instruction: 0xf64db189 │ │ │ │ - vsra.s64 q10, q4, #64 │ │ │ │ + vsra.s64 q10, q0, #64 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ strtmi pc, [r1], -r3, lsr #24 │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ stmdavs r4!, {r0, r1, r4, r6, r7, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ mvnsle r2, r0, lsl #24 │ │ │ │ pop {r3, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7fd41f0 │ │ │ │ @@ -20954,55 +20952,55 @@ │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ ldmvs r1!, {r0, sl, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1], #-3076 @ 0xfffff3fc │ │ │ │ + strcc lr, [r1], #-3080 @ 0xfffff3f8 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ - bl fffe3a20 │ │ │ │ + stc 7, cr15, [r2], {235} @ 0xeb │ │ │ │ ldmvs r1!, {r0, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1], #-3066 @ 0xfffff406 │ │ │ │ + strcc lr, [r1], #-3070 @ 0xfffff402 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ - bl ffd63a34 │ │ │ │ + bl ffe63a2c │ │ │ │ ldmvs r1!, {r0, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1], #-3056 @ 0xfffff410 │ │ │ │ + strcc lr, [r1], #-3060 @ 0xfffff40c │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ - bl ffae3a48 │ │ │ │ + bl ffbe3a40 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ @ instruction: 0xf7eb3401 │ │ │ │ - adcmi lr, r7, #235520 @ 0x39800 │ │ │ │ + adcmi lr, r7, #239616 @ 0x3a800 │ │ │ │ ldmvs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - ldmvs r1!, {r5, r6, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ + ldmvs r1!, {r2, r5, r6, r7, r8, r9, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8], #-32 @ 0xffffffe0 │ │ │ │ + bl ff7e3a60 │ │ │ │ + strdcs r6, [r0], -r1 @ │ │ │ │ bl ff6e3a68 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ bl ff5e3a70 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ bl ff4e3a78 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ bl ff3e3a80 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ bl ff2e3a88 │ │ │ │ strdcs r6, [r0], -r1 @ │ │ │ │ bl ff1e3a90 │ │ │ │ - strdcs r6, [r0], -r1 @ │ │ │ │ - bl ff0e3a98 │ │ │ │ bicsle r4, ip, r7, lsr #5 │ │ │ │ ldmvs r3!, {r8, sp}^ │ │ │ │ @ instruction: 0xf64d6069 │ │ │ │ - vshr.s64 , q6, #64 │ │ │ │ + vshr.s64 , q2, #64 │ │ │ │ andcs r0, r4, #2 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ @ instruction: 0xf7eb2101 │ │ │ │ - svclt 0x0000badf │ │ │ │ + svclt 0x0000bae3 │ │ │ │ @ instruction: 0x460cb570 │ │ │ │ @ instruction: 0x4606b159 │ │ │ │ strtmi r2, [r1], -r0, lsl #10 │ │ │ │ @ instruction: 0xf7fe4630 │ │ │ │ stmdavs r4!, {r0, r2, r4, r5, r6, fp, ip, sp, lr, pc} │ │ │ │ stccs 5, cr3, [r0], {1} │ │ │ │ @ instruction: 0x4628d1f7 │ │ │ │ @@ -21012,258 +21010,258 @@ │ │ │ │ vaddhn.i16 d20, q0, q6 │ │ │ │ strmi r0, [r7], -r5, lsl #8 │ │ │ │ stccs 8, cr6, [r0, #-148] @ 0xffffff6c │ │ │ │ @ instruction: 0x2600d03e │ │ │ │ strcc r6, [r1], -sp, lsr #16 │ │ │ │ mvnsle r2, r0, lsl #26 │ │ │ │ @ instruction: 0xf64d4638 │ │ │ │ - vmla.f d20, d16, d0[7] │ │ │ │ + vmla.f d20, d16, d0[5] │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ vpadd.i8 , q0, │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ ldrtmi r0, [r2], -r5, lsl #6 │ │ │ │ - teqpeq r8, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqpeq r0, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7eb68d8 │ │ │ │ - stmdavs r4!, {r1, r2, r3, r4, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdavs r4!, {r1, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ eorsle r2, fp, r0, lsl #24 │ │ │ │ strtmi r2, [r1], -r0, lsl #10 │ │ │ │ @ instruction: 0xf7fe4638 │ │ │ │ stmdavs r4!, {r0, r1, r6, fp, ip, sp, lr, pc} │ │ │ │ stccs 5, cr3, [r0], {1} │ │ │ │ adcsmi sp, r5, #-1073741763 @ 0xc000003d │ │ │ │ @ instruction: 0x4638d130 │ │ │ │ - blx ffa63b8a │ │ │ │ + blx ffa63b82 │ │ │ │ teqpmi r8, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - blcs 7fc0c │ │ │ │ + blcs 7fc04 │ │ │ │ ldcllt 12, cr13, [r8] │ │ │ │ movtvc pc, #49728 @ 0xc240 @ │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf64d4632 │ │ │ │ - vshr.s64 q10, q12, #64 │ │ │ │ + vshr.s64 q10, q8, #64 │ │ │ │ ldmdavs r9, {r1} │ │ │ │ ldrhtmi lr, [r8], #141 @ 0x8d │ │ │ │ - blt 863b6c │ │ │ │ + blt 963b64 │ │ │ │ mvnmi pc, sp, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx 1163bc2 │ │ │ │ + blx 1163bba │ │ │ │ teqpvc r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf64d462a │ │ │ │ - vbic.i32 d16, #8 @ 0x00000008 │ │ │ │ + vbic.i32 d16, #0 @ 0x00000000 │ │ │ │ ldmvs r8, {r1, r8}^ │ │ │ │ - b ff963b90 │ │ │ │ + b ffa63b88 │ │ │ │ strtmi r6, [r6], -r4, lsr #16 │ │ │ │ sbcsle r2, r0, r0, lsl #24 │ │ │ │ strb r4, [r3, lr, lsr #12] │ │ │ │ - rscmi pc, r0, #80740352 @ 0x4d00000 │ │ │ │ + sbcsmi pc, r8, #80740352 @ 0x4d00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ bicmi pc, r2, r0, asr #4 │ │ │ │ - stc2l 7, cr15, [r0], #-940 @ 0xfffffc54 │ │ │ │ + stc2l 7, cr15, [r4], #-940 @ 0xfffffc54 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ ldrbtcc pc, [ip], #576 @ 0x240 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ stmdavs r3!, {r0, r2, r9, sl, lr} │ │ │ │ suble r2, ip, r0, lsl #22 │ │ │ │ ldmdavs fp, {r9, sl, sp}^ │ │ │ │ - blcs 33428 <__time64@plt+0x22140> │ │ │ │ + blcs 33420 <__time64@plt+0x22138> │ │ │ │ vand , q8, │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ strtmi r0, [r8], -r5, lsl #14 │ │ │ │ - msrvc (UNDEF: 108), r8 │ │ │ │ + msrvc (UNDEF: 100), r8 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx 363c32 │ │ │ │ + blx 363c2a │ │ │ │ @ instruction: 0x463268f8 │ │ │ │ - teqpeq r8, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqpeq r0, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - b fec63bf8 │ │ │ │ + b fed63bf0 │ │ │ │ biclt r6, r4, r4, lsr #16 │ │ │ │ stmdaeq r1, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fee003 │ │ │ │ stmdavs r4!, {r0, r1, r4, r5, r6, r9, fp, ip, sp, lr, pc}^ │ │ │ │ stmdavs fp!, {r2, r3, r7, r8, ip, sp, pc}^ │ │ │ │ strtmi r4, [r8], -r1, lsr #12 │ │ │ │ mvnsle r2, r0, lsl #22 │ │ │ │ strdcs r6, [sl], -r9 │ │ │ │ - bl 63c1c │ │ │ │ + bl 163c14 │ │ │ │ strtmi r4, [r8], -r1, lsr #12 │ │ │ │ andhi pc, r4, r5, asr #17 │ │ │ │ - blx 18e3c74 │ │ │ │ + blx 18e3c6c │ │ │ │ stccs 8, cr6, [r0], {100} @ 0x64 │ │ │ │ strtmi sp, [r8], -sp, ror #3 │ │ │ │ - blx 1be3c7e │ │ │ │ + blx 1be3c76 │ │ │ │ teqpmi r8, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - blcs 7fd00 │ │ │ │ + blcs 7fcf8 │ │ │ │ pop {r0, sl, fp, ip, lr, pc} │ │ │ │ vand q12, q8, q8 │ │ │ │ vqdmlal.s , d0, d0[3] │ │ │ │ ldrtmi r0, [r2], -r5, lsl #6 │ │ │ │ - andspl pc, r0, sp, asr #12 │ │ │ │ + andpl pc, r8, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrhmi lr, [r0, #141]! @ 0x8d │ │ │ │ @ instruction: 0xf7eb6819 │ │ │ │ - ldrmi fp, [lr], -r5, lsr #19 │ │ │ │ + ldrmi fp, [lr], -r9, lsr #19 │ │ │ │ svclt 0x0000e7b5 │ │ │ │ vqrshl.s8 , q12, q8 │ │ │ │ vmov.i32 d20, #0 @ 0x00000000 │ │ │ │ strmi r0, [r7], -r5, lsl #8 │ │ │ │ stccs 8, cr6, [r0, #-148] @ 0xffffff6c │ │ │ │ @ instruction: 0x2600d03e │ │ │ │ strcc r6, [r1], -sp, lsr #16 │ │ │ │ mvnsle r2, r0, lsl #26 │ │ │ │ @ instruction: 0xf64d4638 │ │ │ │ - vmla.f d21, d0, d0[0] │ │ │ │ + vbic.i32 d21, #8 @ 0x00000008 │ │ │ │ @ instruction: 0xf7fd0102 │ │ │ │ vpmin.s8 d31, d16, d23 │ │ │ │ vbic.i32 d23, #0 @ 0x00000000 │ │ │ │ ldrtmi r0, [r2], -r5, lsl #6 │ │ │ │ - teqpeq r8, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqpeq r0, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7eb68d8 │ │ │ │ - stmdavs r4!, {r3, r4, r6, r9, fp, sp, lr, pc} │ │ │ │ + stmdavs r4!, {r2, r3, r4, r6, r9, fp, sp, lr, pc} │ │ │ │ eorsle r2, fp, r0, lsl #24 │ │ │ │ strtmi r2, [r1], -r0, lsl #10 │ │ │ │ @ instruction: 0xf7fd4638 │ │ │ │ stmdavs r4!, {r0, r2, r3, r4, r5, r6, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ stccs 5, cr3, [r0], {1} │ │ │ │ adcsmi sp, r5, #-1073741763 @ 0xc000003d │ │ │ │ @ instruction: 0x4638d130 │ │ │ │ - blx 8e3d16 │ │ │ │ + blx 8e3d0e │ │ │ │ teqpmi r8, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - blcs 7fd98 │ │ │ │ + blcs 7fd90 │ │ │ │ ldcllt 12, cr13, [r8] │ │ │ │ movtvc pc, #49728 @ 0xc240 @ │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf64d4632 │ │ │ │ - vmla.i d21, d0, d0[3] │ │ │ │ + vmla.i d21, d0, d0[1] │ │ │ │ ldmdavs r9, {r1} │ │ │ │ ldrhtmi lr, [r8], #141 @ 0x8d │ │ │ │ - ldmdblt sl, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - cmpppl r0, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ + ldmdblt lr, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + teqppl r8, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - blx 1fe3d4c │ │ │ │ + blx 1fe3d44 │ │ │ │ teqpvc r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf64d462a │ │ │ │ - vbic.i32 d16, #8 @ 0x00000008 │ │ │ │ + vbic.i32 d16, #0 @ 0x00000000 │ │ │ │ ldmvs r8, {r1, r8}^ │ │ │ │ - b 7e3d1c │ │ │ │ + b 8e3d14 │ │ │ │ strtmi r6, [r6], -r4, lsr #16 │ │ │ │ sbcsle r2, r0, r0, lsl #24 │ │ │ │ strb r4, [r3, lr, lsr #12] │ │ │ │ - eorspl pc, r4, #80740352 @ 0x4d00000 │ │ │ │ + eorpl pc, ip, #80740352 @ 0x4d00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - rsbsne pc, r4, sp, asr #4 │ │ │ │ + rsbne pc, ip, sp, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ mvnmi pc, r0, asr #4 │ │ │ │ - blx fe6e3d42 │ │ │ │ + blx fe7e3d3a │ │ │ │ vqrshl.s8 , q12, │ │ │ │ - vaddw.s8 , q0, d16 │ │ │ │ + vorr.i32 d23, #8 @ 0x00000008 │ │ │ │ strmi r0, [r5], -r2, lsl #2 │ │ │ │ - blx 1663d98 │ │ │ │ + blx 1663d90 │ │ │ │ msrmi CPSR_, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ vmax.s8 d20, d0, d24 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ ldmdavs r9, {r0, r2, sl} │ │ │ │ - blx 1463db2 │ │ │ │ + blx 1463daa │ │ │ │ movwvs lr, #2517 @ 0x9d5 │ │ │ │ eorvs r3, lr, r1, lsl #28 │ │ │ │ subsle r2, r9, r0, lsl #22 │ │ │ │ ldclle 14, cr2, [r7, #-0] │ │ │ │ @ instruction: 0xf0162700 │ │ │ │ eorsle r0, r0, r7, lsl #6 │ │ │ │ eorle r2, r7, r1, lsl #22 │ │ │ │ eorle r2, r0, r2, lsl #22 │ │ │ │ andsle r2, r9, r3, lsl #22 │ │ │ │ andsle r2, r2, r4, lsl #22 │ │ │ │ andle r2, fp, r5, lsl #22 │ │ │ │ andle r2, r4, r6, lsl #22 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - smladxcc r1, lr, sl, lr │ │ │ │ + strcc lr, [r1, -r2, asr #20] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - b e63dac │ │ │ │ + b f63da4 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - smladxcc r1, r4, sl, lr │ │ │ │ + smladxcc r1, r8, sl, lr │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - b be3dc0 │ │ │ │ + b ce3db8 │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1, -sl, lsr #20] │ │ │ │ + strcc lr, [r1, -lr, lsr #20] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - b 963dd4 │ │ │ │ + b a63dcc │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7eb3701 │ │ │ │ - adcsmi lr, lr, #32, 20 @ 0x20000 │ │ │ │ + adcsmi lr, lr, #36, 20 @ 0x24000 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r1, r3, r4, r9, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r2, r3, r4, r9, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + b 663dec │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ b 563df4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ b 463dfc │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ b 363e04 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ b 263e0c │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ b 163e14 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ b 63e1c │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - ldmib ip!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrhle r4, [ip, #46] @ 0x2e │ │ │ │ stmiavs r1!, {r8, r9, sp}^ │ │ │ │ eorcs r6, r9, fp, rrx │ │ │ │ - ldmib r4!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmib r8!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ tstlt r3, fp, ror #16 │ │ │ │ stmiavs r1!, {r3, r4, r5, r6, r7, r8, sl, fp, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7eb200a │ │ │ │ - movwcs lr, #6638 @ 0x19ee │ │ │ │ + movwcs lr, #6642 @ 0x19f2 │ │ │ │ ldcllt 0, cr6, [r8, #428]! @ 0x1ac │ │ │ │ svcmi 0x00f0e92d │ │ │ │ - msrpl (UNDEF: 100), sp │ │ │ │ + cmpppl ip, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ strmi fp, [r5], -r5, lsl #1 │ │ │ │ - bmi 18627b0 │ │ │ │ - beq 1a29b4 │ │ │ │ + bmi 18627a8 │ │ │ │ + beq 1a29ac │ │ │ │ @ instruction: 0xf9cef7fd │ │ │ │ ldrtvc pc, [r0], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ msrmi SPSR_f, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ ldrdcs pc, [r0], -sl │ │ │ │ - cmnppl r0, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ + msrpl (UNDEF: 104), sp │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ ldmdavs fp, {r5, r6, r7, fp, sp, lr} │ │ │ │ - stmdb r8!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb ip!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -sl │ │ │ │ vqrdmulh.s d18, d0, d0 │ │ │ │ vrhadd.s8 d24, d0, d8 │ │ │ │ vqdmull.s q10, d0, d0[5] │ │ │ │ @ instruction: 0xf04f0b05 │ │ │ │ @ instruction: 0xf64a0800 │ │ │ │ - vqdmlal.s q10, d0, d0[1] │ │ │ │ + vbic.i32 d20, #3072 @ 0x00000c00 │ │ │ │ movwls r0, #13058 @ 0x3302 │ │ │ │ - mvnsne pc, #80740352 @ 0x4d00000 │ │ │ │ + mvnne pc, #80740352 @ 0x4d00000 │ │ │ │ movweq pc, #8896 @ 0x22c0 @ │ │ │ │ @ instruction: 0xf8db9302 │ │ │ │ @ instruction: 0xf8533000 │ │ │ │ ldrtmi r6, [r0], -r8, lsr #32 │ │ │ │ mcr2 7, 0, pc, cr14, cr6, {7} @ │ │ │ │ stmdacs r0, {r0, r1, r2, r9, sl, lr} │ │ │ │ mrshi pc, (UNDEF: 1) @ │ │ │ │ - blcs 400cc <__time64@plt+0x2ede4> │ │ │ │ + blcs 400c4 <__time64@plt+0x2eddc> │ │ │ │ mrshi pc, (UNDEF: 13) @ │ │ │ │ movwls r6, #6187 @ 0x182b │ │ │ │ vldrle d18, [lr, #-0] │ │ │ │ @ instruction: 0xf04f9b01 │ │ │ │ @ instruction: 0xf0130900 │ │ │ │ eorsle r0, r3, r7, lsl #4 │ │ │ │ eorle r2, r8, r1, lsl #20 │ │ │ │ @@ -21271,245 +21269,245 @@ │ │ │ │ andsle r2, r8, r3, lsl #20 │ │ │ │ andsle r2, r0, r4, lsl #20 │ │ │ │ andle r2, r8, r5, lsl #20 │ │ │ │ @ instruction: 0xf0402a06 │ │ │ │ @ instruction: 0xf1098109 │ │ │ │ stmiavs r1!, {r0, r8, fp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0xf109e98a │ │ │ │ + @ instruction: 0xf109e98e │ │ │ │ stmiavs r1!, {r0, r8, fp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0xf109e984 │ │ │ │ + @ instruction: 0xf109e988 │ │ │ │ stmiavs r1!, {r0, r8, fp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0xf109e97e │ │ │ │ + @ instruction: 0xf109e982 │ │ │ │ stmiavs r1!, {r0, r8, fp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0xf109e978 │ │ │ │ + @ instruction: 0xf109e97c │ │ │ │ stmiavs r1!, {r0, r8, fp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r1, r4, r5, r6, r8, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r1, r2, r4, r5, r6, r8, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - blls a0550 │ │ │ │ + blls a0558 │ │ │ │ stmdbeq r1, {r0, r3, r8, ip, sp, lr, pc} │ │ │ │ mlale r4, r9, r5, r4 │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmdb r4!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb r8!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdbeq r8, {r0, r3, r8, ip, sp, lr, pc} │ │ │ │ + stmdb r2!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ ldmdb lr, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmdb sl, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmdb r6, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldmdb r2, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdb lr, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdb sl, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - stmdb r6, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrmi r9, [r9, #2817] @ 0xb01 │ │ │ │ movwcs sp, #474 @ 0x1da │ │ │ │ rsbvs r6, fp, r0, ror #17 │ │ │ │ - rsbspl pc, r8, #80740352 @ 0x4d00000 │ │ │ │ + rsbspl pc, r0, #80740352 @ 0x4d00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - orrne pc, r4, sp, asr #12 │ │ │ │ + cmnpne ip, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldm r4, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm r8, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmiavs r0!, {r0, r1, r3, r5, fp, sp, lr}^ │ │ │ │ movwcc r4, #5682 @ 0x1632 │ │ │ │ tstlt r6, fp, lsr #32 │ │ │ │ stmdbls r2, {r1, r4, r5, r6, fp, sp, lr} │ │ │ │ - stmia sl, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia lr, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x46284639 │ │ │ │ - blx 7e4014 │ │ │ │ + blx 7e400c │ │ │ │ movwvs lr, #2517 @ 0x9d5 │ │ │ │ eorvs r3, lr, r1, lsl #28 │ │ │ │ subsle r2, r5, r0, lsl #22 │ │ │ │ ldclle 14, cr2, [r3, #-0] │ │ │ │ @ instruction: 0xf0162700 │ │ │ │ eorle r0, ip, r7, lsl #6 │ │ │ │ eorle r2, r3, r1, lsl #22 │ │ │ │ andsle r2, ip, r2, lsl #22 │ │ │ │ andsle r2, r5, r3, lsl #22 │ │ │ │ andle r2, lr, r4, lsl #22 │ │ │ │ andle r2, r7, r5, lsl #22 │ │ │ │ @ instruction: 0xf0402b06 │ │ │ │ strcc r8, [r1, -r3, lsl #1] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmdb sl, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb lr, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - strcc lr, [r1, -r6, lsl #18] │ │ │ │ + strcc lr, [r1, -sl, lsl #18] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - stmdb r0, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r4, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ stmiavs r1!, {r0, r8, r9, sl, ip, sp}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - @ instruction: 0x3701e8fc │ │ │ │ + strcc lr, [r1, -r0, lsl #18] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ - ldm r6!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm sl!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7eb3701 │ │ │ │ - adcsmi lr, lr, #15859712 @ 0xf20000 │ │ │ │ + adcsmi lr, lr, #16121856 @ 0xf60000 │ │ │ │ stmiavs r1!, {r1, r5, ip, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb2020 │ │ │ │ - stmiavs r1!, {r2, r3, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r1!, {r4, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ strcc r2, [r8, -r0, lsr #32] │ │ │ │ + stmia sl!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + eorcs r6, r0, r1, ror #17 │ │ │ │ stmia r6!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmia r2!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldm lr, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldm sl, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldm r6, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ ldm r2, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - eorcs r6, r0, r1, ror #17 │ │ │ │ - stmia lr, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrhle r4, [ip, #46] @ 0x2e │ │ │ │ stmiavs r1!, {r8, r9, sp}^ │ │ │ │ eorcs r6, r9, fp, rrx │ │ │ │ - stmia r6, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia sl, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ cmnlt r3, fp, ror #16 │ │ │ │ ldrdcc pc, [r0], -sl │ │ │ │ stmdaeq r1, {r3, r8, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf73f4543 │ │ │ │ strtmi sl, [r8], -r8, lsl #30 │ │ │ │ pop {r0, r2, ip, sp, pc} │ │ │ │ @ instruction: 0xf7fd4ff0 │ │ │ │ stmiavs r1!, {r0, r4, r5, r8, fp, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7eb200a │ │ │ │ - @ instruction: 0xf8dae8b4 │ │ │ │ + @ instruction: 0xf8dae8b8 │ │ │ │ @ instruction: 0xf1083000 │ │ │ │ andcs r0, r1, #65536 @ 0x10000 │ │ │ │ rsbvs r4, sl, r3, asr #10 │ │ │ │ mrcge 7, 7, APSR_nzcv, cr5, cr15, {1} │ │ │ │ strtmi lr, [r8], -fp, ror #15 │ │ │ │ @ instruction: 0xf7fd9903 │ │ │ │ stmiavs r0!, {r0, r1, r2, r4, r7, fp, ip, sp, lr, pc}^ │ │ │ │ ldmdavs r2!, {r1, r2, r3, r4, r8, r9, ip, sp, pc}^ │ │ │ │ stmdbls r2, {r0, r3, r9, sl, ip, sp} │ │ │ │ - ldmda ip!, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda r0, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x46284631 │ │ │ │ @ instruction: 0xf990f7fd │ │ │ │ stmiavs r1!, {r4, r5, r6, r8, r9, sl, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7eb200a │ │ │ │ - stmdavs fp!, {r1, r2, r4, r7, fp, sp, lr, pc} │ │ │ │ + stmdavs fp!, {r1, r3, r4, r7, fp, sp, lr, pc} │ │ │ │ ldrmi r9, [sl], -r1, lsl #6 │ │ │ │ - bcs 2ed54 <__time64@plt+0x1da6c> │ │ │ │ + bcs 2ed4c <__time64@plt+0x1da64> │ │ │ │ @ instruction: 0xf73f606b │ │ │ │ strb sl, [r8, -fp, ror #29] │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ @ instruction: 0xf7eb2701 │ │ │ │ - ldrb lr, [r6, -r8, lsl #17]! │ │ │ │ + ldrb lr, [r6, -ip, lsl #17]! │ │ │ │ eorcs r6, r0, r1, ror #17 │ │ │ │ stmdbeq r1, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ - stm r0, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stm r4, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrtmi lr, [r2], -pc, ror #13 │ │ │ │ - mvnsne pc, sp, asr #12 │ │ │ │ + mvnne pc, sp, asr #12 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldmda r6, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda sl, {r0, r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ svclt 0x0000e7d8 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ ldrbcc pc, [r0, #576]! @ 0x240 @ │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ ldrtvc pc, [r0], -r0, asr #4 @ │ │ │ │ streq pc, [r5], -r0, asr #5 │ │ │ │ - orrpl pc, r0, sp, asr #12 │ │ │ │ + cmnppl r8, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7fd4681 │ │ │ │ stmdavs sl!, {r0, r1, r2, r4, r6, fp, ip, sp, lr, pc} │ │ │ │ - teqpeq r8, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ + teqpeq r0, sp, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - @ instruction: 0xf7ea68f0 │ │ │ │ - stmdavs fp!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + @ instruction: 0xf7eb68f0 │ │ │ │ + stmdavs fp!, {fp, sp, lr, pc} │ │ │ │ vldrle d2, [r4, #-0] │ │ │ │ ldmcc r4!, {r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdaeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - strbpl pc, [r4, -ip, asr #12]! @ │ │ │ │ + ldrbpl pc, [ip, -ip, asr #12] @ │ │ │ │ streq pc, [r2, -r0, asr #5] │ │ │ │ @ instruction: 0xf8d82400 │ │ │ │ ldrtmi r3, [r9], -r0 │ │ │ │ @ instruction: 0xf85368f0 │ │ │ │ strcc r2, [r1], #-36 @ 0xffffffdc │ │ │ │ - svc 0x00e6f7ea │ │ │ │ + svc 0x00eaf7ea │ │ │ │ adcmi r6, r3, #2818048 @ 0x2b0000 │ │ │ │ @ instruction: 0x4648dcf3 │ │ │ │ mvnsmi lr, #12386304 @ 0xbd0000 │ │ │ │ ldmlt sl!, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0x4df0e92d │ │ │ │ @ instruction: 0xf04f4605 │ │ │ │ addslt r0, r2, r0, lsl #20 │ │ │ │ - bleq 6233c │ │ │ │ + bleq 62334 │ │ │ │ stmib sp, {r1, fp, sp, pc}^ │ │ │ │ @ instruction: 0xf7ebab02 │ │ │ │ - eorcs lr, r8, #7471104 @ 0x720000 │ │ │ │ + eorcs lr, r8, #7733248 @ 0x760000 │ │ │ │ stmdage r8, {r8, sp} │ │ │ │ - svc 0x00e4f7ea │ │ │ │ + svc 0x00e8f7ea │ │ │ │ @ instruction: 0xf7ea9c02 │ │ │ │ - @ instruction: 0x2127efaa │ │ │ │ + @ instruction: 0x2127efae │ │ │ │ andls r4, r0, r3, lsr #12 │ │ │ │ - addpl pc, ip, #80740352 @ 0x4d00000 │ │ │ │ + addpl pc, r4, #80740352 @ 0x4d00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ vadd.i8 d26, d0, d8 │ │ │ │ vmvn.i32 d23, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf7ea0405 │ │ │ │ - andcs lr, r0, #824 @ 0x338 │ │ │ │ + andcs lr, r0, #840 @ 0x348 │ │ │ │ strtmi sl, [r8], -r8, lsl #18 │ │ │ │ - mcr2 7, 6, pc, cr6, cr0, {7} @ │ │ │ │ - cmppvs r0, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ + mcr2 7, 6, pc, cr10, cr0, {7} @ │ │ │ │ + teqpvs r8, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ee4606 │ │ │ │ - rscvs pc, r0, r2, lsl #28 │ │ │ │ + rscvs pc, r0, r6, lsl #28 │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ vqadd.s8 q12, q8, q6 │ │ │ │ vbic.i32 d20, #134217728 @ 0x08000000 │ │ │ │ ldmdavs sl!, {r0, r2, r8, r9, sl} │ │ │ │ vpmax.u8 d2, d0, d2 │ │ │ │ @ instruction: 0x4603809a │ │ │ │ tstcs r1, ip, lsl r2 │ │ │ │ - sbcpl pc, r8, sp, asr #12 │ │ │ │ + sbcpl pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ stmdavc ip, {r6, r9, ip, sp, lr, pc}^ │ │ │ │ stmdaeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ - svc 0x0026f7ea │ │ │ │ + svc 0x002af7ea │ │ │ │ eorscs r6, ip, #14876672 @ 0xe30000 │ │ │ │ @ instruction: 0xf64d2101 │ │ │ │ - vmla.i d21, d16, d0[6] │ │ │ │ + vmla.i d21, d16, d0[4] │ │ │ │ @ instruction: 0xf7ea0002 │ │ │ │ - stmiavs r3!, {r1, r2, r3, r4, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r3!, {r1, r5, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ tstcs r1, r4, asr #4 │ │ │ │ - eorvs pc, r8, sp, asr #12 │ │ │ │ + eorvs pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - svc 0x0014f7ea │ │ │ │ + svc 0x0018f7ea │ │ │ │ tstcs r1, r1, asr #4 │ │ │ │ @ instruction: 0xf64d68e3 │ │ │ │ - vmvn.i32 q11, #0 @ 0x00000000 │ │ │ │ + vmla.i d22, d0, d0[6] │ │ │ │ @ instruction: 0xf7ea0002 │ │ │ │ - stmiavs r0!, {r2, r3, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r0!, {r4, r8, r9, sl, fp, sp, lr, pc}^ │ │ │ │ ldrdcs pc, [r0], -r8 │ │ │ │ - @ instruction: 0x61b4f64d │ │ │ │ + @ instruction: 0x61acf64d │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - svc 0x0072f7ea │ │ │ │ + svc 0x0076f7ea │ │ │ │ vadd.i8 d26, d11, d4 │ │ │ │ - vsra.s64 q11, q12, #64 │ │ │ │ + vsra.s64 q11, q8, #64 │ │ │ │ movwcs r0, #258 @ 0x102 │ │ │ │ - blge 160a0c │ │ │ │ + blge 160a04 │ │ │ │ @ instruction: 0xf7fc9306 │ │ │ │ stmdage r4, {r0, r1, r3, r4, r5, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ - tstpcc ip, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ + tstpcc r4, sl, asr #12 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf8b8f7fd │ │ │ │ @ instruction: 0xf7fda804 │ │ │ │ stmdage r4, {r0, r3, r4, r5, fp, ip, sp, lr, pc} │ │ │ │ - msrvc R8_usr, fp │ │ │ │ + tstpvc r8, fp, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xffaaf7fc │ │ │ │ msrmi CPSR_, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ ldmdavs r9, {r2, fp, sp, pc} │ │ │ │ @ instruction: 0xf8a6f7fd │ │ │ │ @ instruction: 0xf7fda804 │ │ │ │ @@ -21518,307 +21516,307 @@ │ │ │ │ @ instruction: 0xf7ffa804 │ │ │ │ stmdage r4, {r0, r2, r3, r4, r5, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ ldc2l 7, cr15, [r0], #-1020 @ 0xfffffc04 │ │ │ │ @ instruction: 0xf7ffa804 │ │ │ │ stmdage r4, {r0, sl, fp, ip, sp, lr, pc} │ │ │ │ stc2l 7, cr15, [r4], {255} @ 0xff │ │ │ │ @ instruction: 0xf64d68e1 │ │ │ │ - vshr.s64 q11, q10, #64 │ │ │ │ + vmla.i d22, d16, d0[7] │ │ │ │ @ instruction: 0xf7ea0002 │ │ │ │ - andcc lr, r1, r4, lsr lr │ │ │ │ + andcc lr, r1, r8, lsr lr │ │ │ │ addshi pc, r8, r0 │ │ │ │ @ instruction: 0xf7ea68e0 │ │ │ │ - stmiavs r2!, {r3, r4, r5, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r2!, {r2, r3, r4, r5, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ ldmdavs r1, {r2, r9, sl, lr} │ │ │ │ @ instruction: 0xf100068b │ │ │ │ ldrmi r8, [r0], -r2, lsl #1 │ │ │ │ - svc 0x0068f7ea │ │ │ │ + svc 0x006cf7ea │ │ │ │ cmnle pc, r0, lsl #16 │ │ │ │ ldrtmi r4, [r0], -r9, lsr #12 │ │ │ │ - cdp 7, 14, cr15, cr14, cr10, {7} │ │ │ │ + cdp 7, 15, cr15, cr2, cr10, {7} │ │ │ │ cmple fp, r0, lsl #16 │ │ │ │ @ instruction: 0xf7ea4630 │ │ │ │ - ldmdavs fp!, {r1, r2, r4, r6, r9, sl, fp, sp, lr, pc} │ │ │ │ + ldmdavs fp!, {r1, r3, r4, r6, r9, sl, fp, sp, lr, pc} │ │ │ │ vstrle d2, [fp, #-0] │ │ │ │ @ instruction: 0xf64d9e06 │ │ │ │ - vshr.s64 , q2, #64 │ │ │ │ + vmla.i d23, d16, d0[3] │ │ │ │ @ instruction: 0xf8d80002 │ │ │ │ strtmi r1, [r3], -r0 │ │ │ │ strls r4, [r0], -sl, lsr #12 │ │ │ │ - cdp 7, 3, cr15, cr8, cr10, {7} │ │ │ │ + cdp 7, 3, cr15, cr12, cr10, {7} │ │ │ │ pop {r1, r4, ip, sp, pc} │ │ │ │ vmla.f32 q12, q8, q8 │ │ │ │ vmul.i d23, d0, d0[3] │ │ │ │ ldrtmi r0, [r3], -r5, lsl #16 │ │ │ │ @ instruction: 0xf64d462a │ │ │ │ - vaddl.s8 , d0, d4 │ │ │ │ + vshr.s64 q11, q14, #64 │ │ │ │ @ instruction: 0xf8d80002 │ │ │ │ @ instruction: 0xf7ea1000 │ │ │ │ - stmiavs r3!, {r3, r5, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r3!, {r2, r3, r5, r9, sl, fp, sp, lr, pc}^ │ │ │ │ tstcs r1, ip, lsl r2 │ │ │ │ - sbcpl pc, r8, sp, asr #12 │ │ │ │ + sbcpl pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - cdp 7, 8, cr15, cr2, cr10, {7} │ │ │ │ + cdp 7, 8, cr15, cr6, cr10, {7} │ │ │ │ eorscs r6, ip, #14876672 @ 0xe30000 │ │ │ │ @ instruction: 0xf64d2101 │ │ │ │ - vmla.i d21, d16, d0[6] │ │ │ │ + vmla.i d21, d16, d0[4] │ │ │ │ @ instruction: 0xf7ea0002 │ │ │ │ - stmiavs r3!, {r1, r3, r4, r5, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ + stmiavs r3!, {r1, r2, r3, r4, r5, r6, r9, sl, fp, sp, lr, pc}^ │ │ │ │ tstcs r1, r4, asr #4 │ │ │ │ - eorvs pc, r8, sp, asr #12 │ │ │ │ + eorvs pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - cdp 7, 7, cr15, cr0, cr10, {7} │ │ │ │ + cdp 7, 7, cr15, cr4, cr10, {7} │ │ │ │ tstcs r1, r1, asr #4 │ │ │ │ @ instruction: 0xf64d68e3 │ │ │ │ - vmvn.i32 q11, #0 @ 0x00000000 │ │ │ │ + vmla.i d22, d0, d0[6] │ │ │ │ @ instruction: 0xf7ea0002 │ │ │ │ - @ instruction: 0xf64dee68 │ │ │ │ - vsra.s64 d22, d20, #64 │ │ │ │ + @ instruction: 0xf64dee6c │ │ │ │ + vaddw.s8 q11, q8, d28 │ │ │ │ @ instruction: 0xf8d80102 │ │ │ │ stmiavs r0!, {sp}^ │ │ │ │ @ instruction: 0xf7eae75a │ │ │ │ - stmdavs r0, {r1, r3, r4, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ - cdp2 7, 5, cr15, cr10, cr14, {7} │ │ │ │ + stmdavs r0, {r1, r2, r3, r4, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + cdp2 7, 5, cr15, cr14, cr14, {7} │ │ │ │ @ instruction: 0x46024631 │ │ │ │ - addspl pc, r8, sp, asr #12 │ │ │ │ + addspl pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - @ instruction: 0xfff8f7ea │ │ │ │ - cdp 7, 12, cr15, cr12, cr10, {7} │ │ │ │ + @ instruction: 0xfffcf7ea │ │ │ │ + cdp 7, 13, cr15, cr0, cr10, {7} │ │ │ │ @ instruction: 0xf7ee6800 │ │ │ │ - strtmi pc, [sl], -sp, asr #28 │ │ │ │ + @ instruction: 0x462afe51 │ │ │ │ ldrtmi r4, [r1], -r3, lsl #12 │ │ │ │ - adcvc pc, r8, sp, asr #12 │ │ │ │ + adcvc pc, r0, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - @ instruction: 0xffeaf7ea │ │ │ │ - cdp 7, 11, cr15, cr14, cr10, {7} │ │ │ │ + @ instruction: 0xffeef7ea │ │ │ │ + cdp 7, 12, cr15, cr2, cr10, {7} │ │ │ │ @ instruction: 0xf7ee6800 │ │ │ │ - @ instruction: 0x4631fe3f │ │ │ │ + ldrtmi pc, [r1], -r3, asr #28 @ │ │ │ │ @ instruction: 0xf64d4602 │ │ │ │ - vaddl.s8 , d16, d4 │ │ │ │ + vmvn.i32 , #12 @ 0x0000000c │ │ │ │ @ instruction: 0xf7ea0002 │ │ │ │ - @ instruction: 0xf7eaffdd │ │ │ │ - stmdavs r0, {r1, r4, r5, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ - cdp2 7, 3, cr15, cr2, cr14, {7} │ │ │ │ + @ instruction: 0xf7eaffe1 │ │ │ │ + stmdavs r0, {r1, r2, r4, r5, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + cdp2 7, 3, cr15, cr6, cr14, {7} │ │ │ │ @ instruction: 0x46024631 │ │ │ │ - subsvc pc, r4, sp, asr #12 │ │ │ │ + subvc pc, ip, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - @ instruction: 0xffd0f7ea │ │ │ │ - cdp 7, 10, cr15, cr4, cr10, {7} │ │ │ │ + @ instruction: 0xffd4f7ea │ │ │ │ + cdp 7, 10, cr15, cr8, cr10, {7} │ │ │ │ @ instruction: 0xf7ee6800 │ │ │ │ - strmi pc, [r1], -r5, lsr #28 │ │ │ │ - eorsvc pc, r0, sp, asr #12 │ │ │ │ + strmi pc, [r1], -r9, lsr #28 │ │ │ │ + eorvc pc, r8, sp, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - @ instruction: 0xffc4f7ea │ │ │ │ + @ instruction: 0xffc8f7ea │ │ │ │ svcmi 0x00f0e92d │ │ │ │ ldrvc pc, [r0, #-576]! @ 0xfffffdc0 │ │ │ │ streq pc, [r5, #-704] @ 0xfffffd40 │ │ │ │ vqadd.s8 d27, d27, d1 │ │ │ │ - vaddw.s8 q10, q0, d20 │ │ │ │ + vorr.i32 d20, #12 @ 0x0000000c │ │ │ │ strmi r0, [r7], -r2, lsl #2 │ │ │ │ - ldc2l 7, cr15, [r3], {238} @ 0xee │ │ │ │ + ldc2l 7, cr15, [r7], {238} @ 0xee │ │ │ │ stmdacs r0, {r3, r5, r6, r7, sp, lr} │ │ │ │ strbhi pc, [r9, r0]! @ │ │ │ │ ldmdbmi r8!, {r6, r9, ip, sp, lr, pc} │ │ │ │ stmdbeq r5, {r6, r7, r9, ip, sp, lr, pc} │ │ │ │ stmib r5, {r0, r8, r9, sp}^ │ │ │ │ @ instruction: 0xf8d93700 │ │ │ │ - blcs 324c8 <__time64@plt+0x211e0> │ │ │ │ + blcs 324c0 <__time64@plt+0x211d8> │ │ │ │ addhi pc, r6, r0, lsl #6 │ │ │ │ vcgt.s8 d18, d1, d0 │ │ │ │ - vmov.i32 d20, #3328 @ 0x00000d00 │ │ │ │ + vmov.i32 d20, #1280 @ 0x00000500 │ │ │ │ vhsub.s8 d16, d1, d2 │ │ │ │ - vorr.i32 d20, #9 @ 0x00000009 │ │ │ │ + vorr.i32 d20, #1 @ 0x00000001 │ │ │ │ vrhadd.s8 d16, d0, d2 │ │ │ │ @ instruction: 0xf7f070e1 │ │ │ │ - movwcs pc, #3579 @ 0xdfb @ │ │ │ │ + movwcs pc, #3583 @ 0xdff @ │ │ │ │ vrhadd.s8 d22, d21, d24 │ │ │ │ vsubl.s8 q8, d0, d9 │ │ │ │ vhsub.s8 d16, d7, d1 │ │ │ │ vaddw.s8 q9, q8, d13 │ │ │ │ @ instruction: 0xf6400101 │ │ │ │ @ instruction: 0xf7f070bb │ │ │ │ - stmiavs ip!, {r0, r2, r3, r5, r6, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ + stmiavs ip!, {r0, r4, r5, r6, r7, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ stccs 1, cr6, [r0], {104} @ 0x68 │ │ │ │ ldrbhi pc, [lr], r0 @ │ │ │ │ stmdacs r0, {r5, r8, fp, sp, lr} │ │ │ │ strhi pc, [r9, r0]! │ │ │ │ - bcs 1005a0 │ │ │ │ + bcs 100598 │ │ │ │ strbthi pc, [r7], r0, asr #32 @ │ │ │ │ - bcs 180528 │ │ │ │ + bcs 180520 │ │ │ │ strbthi pc, [r3], r0, asr #32 @ │ │ │ │ - cmppeq ip, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppeq r4, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ea6940 │ │ │ │ - stmdacs r0, {r2, r3, r4, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r5, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ ldrbhi pc, [r9], r0, asr #32 @ │ │ │ │ stmdacs r0, {r3, r5, r7, fp, sp, lr} │ │ │ │ bicshi pc, r9, #0 │ │ │ │ @ instruction: 0xf7ea6906 │ │ │ │ - adcvs lr, lr, lr, ror #26 │ │ │ │ + adcvs lr, lr, r2, ror sp │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ ldmdbvs r4!, {r1, r4, r6, r7, r8, r9, pc} │ │ │ │ @ instruction: 0xf7ea4630 │ │ │ │ - adcvs lr, ip, r6, ror #26 │ │ │ │ + adcvs lr, ip, sl, ror #26 │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ stmdbvs r0!, {r0, r1, r2, r6, r8, r9, sl, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdavs r2!, {r5, r6, r8, r9, sl, pc} │ │ │ │ @ instruction: 0xf0402a02 │ │ │ │ stmdavs r3, {r0, r2, r3, r6, r8, r9, sl, pc} │ │ │ │ @ instruction: 0xf0402b04 │ │ │ │ @ instruction: 0xf1048749 │ │ │ │ @ instruction: 0xf64a0814 │ │ │ │ - vsubhn.i16 d19, q0, q6 │ │ │ │ + vsubhn.i16 d19, q0, q2 │ │ │ │ strbmi r0, [r1], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7ea4630 │ │ │ │ - stmdacs r0, {r4, r5, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r2, r4, r5, r8, sl, fp, sp, lr, pc} │ │ │ │ ldrbhi pc, [r4, r0, asr #32] @ │ │ │ │ stmdacs r0, {r3, r5, r7, fp, sp, lr} │ │ │ │ @ instruction: 0x83adf000 │ │ │ │ @ instruction: 0xf7ea6906 │ │ │ │ - adcvs lr, lr, r2, asr #26 │ │ │ │ + adcvs lr, lr, r6, asr #26 │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ ldmdbvs r4!, {r1, r2, r5, r7, r8, r9, pc} │ │ │ │ @ instruction: 0xf7ea4630 │ │ │ │ - adcvs lr, ip, sl, lsr sp │ │ │ │ + adcvs lr, ip, lr, lsr sp │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ stmdbvs r0!, {r0, r1, r4, r8, r9, sl, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdavs r2!, {r0, r1, r2, r8, r9, sl, pc} │ │ │ │ tstle r2, r3, lsl #20 │ │ │ │ - bcs 1805d0 │ │ │ │ + bcs 1805c8 │ │ │ │ vhadd.s8 d29, d14, d25 │ │ │ │ - vsra.s64 q8, q14, #64 │ │ │ │ + vsra.s64 q8, q10, #64 │ │ │ │ strtmi r0, [r0], -r2, lsl #2 │ │ │ │ - cdp2 7, 9, cr15, cr2, cr10, {7} │ │ │ │ + cdp2 7, 9, cr15, cr6, cr10, {7} │ │ │ │ movtvc pc, #49728 @ 0xc240 @ │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ vmin.s8 d20, d14, d26 │ │ │ │ - vmla.i d16, d0, d0[0] │ │ │ │ + vmvn.i32 d16, #8 @ 0x00000008 │ │ │ │ vhadd.s8 d16, d0, d2 │ │ │ │ vmls.i d19, d16, d0[5] │ │ │ │ ldmdavs r9, {r0, r2, sl} │ │ │ │ - stc 7, cr15, [r6, #-936] @ 0xfffffc58 │ │ │ │ + stc 7, cr15, [sl, #-936] @ 0xfffffc58 │ │ │ │ ldrdcc pc, [r0], -r9 │ │ │ │ vstrle d2, [sl, #-4] │ │ │ │ ldmib r0, {r5, fp, sp, lr}^ │ │ │ │ addsmi r3, r3, #1342177280 @ 0x50000000 │ │ │ │ mrrcne 15, 3, fp, sl, cr15 │ │ │ │ andcs r6, sl, #-2147483632 @ 0x80000010 │ │ │ │ @ instruction: 0xf080701a │ │ │ │ stmdavs r0!, {r0, r3, r4, r8, r9, sl, pc} │ │ │ │ - ldcl 7, cr15, [r0, #-936] @ 0xfffffc58 │ │ │ │ + ldcl 7, cr15, [r4, #-936] @ 0xfffffc58 │ │ │ │ stmdbvs r0, {r1, r2, r4, r6, r8, r9, sl, sp, lr, pc}^ │ │ │ │ - mvnseq pc, lr, asr #4 │ │ │ │ + mvneq pc, lr, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldcl 7, cr15, [lr], {234} @ 0xea │ │ │ │ + stcl 7, cr15, [r2], #936 @ 0x3a8 │ │ │ │ stmdacs r0, {r7, r9, sl, lr} │ │ │ │ stmiavs r8!, {r0, r1, r3, r6, r7, r8, ip, lr, pc} │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdbvs r4, {r2, r3, r4, r6, r8, r9, pc} │ │ │ │ - ldcl 7, cr15, [r0], #936 @ 0x3a8 │ │ │ │ + ldcl 7, cr15, [r4], #936 @ 0x3a8 │ │ │ │ stccs 0, cr6, [r0], {172} @ 0xac │ │ │ │ cmpphi r5, #0 @ p-variant is OBSOLETE │ │ │ │ stmdbvs r4!, {r5, r9, sl, lr} │ │ │ │ - stcl 7, cr15, [r8], #936 @ 0x3a8 │ │ │ │ + stcl 7, cr15, [ip], #936 @ 0x3a8 │ │ │ │ stccs 0, cr6, [r0], {172} @ 0xac │ │ │ │ strthi pc, [r8], r0 │ │ │ │ stmdacs r0, {r5, r8, fp, sp, lr} │ │ │ │ ldrbhi pc, [fp], r0 @ │ │ │ │ - bcs c06ec │ │ │ │ + bcs c06e4 │ │ │ │ stmdavs r3, {r0, r4, r5, r7, r8, ip, lr, pc} │ │ │ │ @ instruction: 0xd1ae2b04 │ │ │ │ andseq pc, r4, r4, lsl #2 │ │ │ │ - blx fe3e463a │ │ │ │ + blx fe3e4632 │ │ │ │ msrmi CPSR_, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ andsvs r9, r8, r4, lsl #6 │ │ │ │ - stc 7, cr15, [r6, #936] @ 0x3a8 │ │ │ │ + stc 7, cr15, [sl, #936] @ 0x3a8 │ │ │ │ vadd.i8 d22, d16, d27 │ │ │ │ vmov.i32 d20, #3072 @ 0x00000c00 │ │ │ │ andsvs r0, r0, r5, lsl #4 │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ ldmdbvs ip, {r1, r2, r3, r5, r8, r9, pc} │ │ │ │ @ instruction: 0xf7ea4618 │ │ │ │ - adcvs lr, ip, r2, asr #25 │ │ │ │ + adcvs lr, ip, r6, asr #25 │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ @ instruction: 0xf8d48326 │ │ │ │ @ instruction: 0x4620b010 │ │ │ │ - ldc 7, cr15, [r8], #936 @ 0x3a8 │ │ │ │ + ldc 7, cr15, [ip], #936 @ 0x3a8 │ │ │ │ andlt pc, r8, r5, asr #17 │ │ │ │ svceq 0x0000f1bb │ │ │ │ strbthi pc, [r2], -r0 @ │ │ │ │ @ instruction: 0x4010f8db │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ @ instruction: 0xf8d48628 │ │ │ │ @ instruction: 0xf104a010 │ │ │ │ @ instruction: 0xf1ba0610 │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ @ instruction: 0xf8db8641 │ │ │ │ cdpcs 0, 0, cr6, cr3, cr0, {0} │ │ │ │ tstlt r4, r3, lsl #2 │ │ │ │ - blcs 180770 │ │ │ │ + blcs 180768 │ │ │ │ vhadd.s8 d29, d14, d6 │ │ │ │ - vaddw.s8 , q0, d20 │ │ │ │ + vorr.i32 d17, #12 @ 0x0000000c │ │ │ │ ldrbmi r0, [r8], -r2, lsl #2 │ │ │ │ - cdp2 7, 0, cr15, cr4, cr10, {7} │ │ │ │ + cdp2 7, 0, cr15, cr8, cr10, {7} │ │ │ │ vmla.i8 q11, q7, q8 │ │ │ │ - vorr.i32 d17, #8 @ 0x00000008 │ │ │ │ + vorr.i32 d17, #0 @ 0x00000000 │ │ │ │ @ instruction: 0xf7ea0102 │ │ │ │ - mcrne 12, 0, lr, cr3, cr4, {3} │ │ │ │ + mcrne 12, 0, lr, cr3, cr8, {3} │ │ │ │ movwcs fp, #7960 @ 0x1f18 │ │ │ │ svceq 0x0000f1ba │ │ │ │ @ instruction: 0xf043bf08 │ │ │ │ - blcs 27318 <__time64@plt+0x16030> │ │ │ │ + blcs 27310 <__time64@plt+0x16028> │ │ │ │ @ instruction: 0xf8dad1e7 │ │ │ │ - blcs 7271c │ │ │ │ + blcs 72714 │ │ │ │ @ instruction: 0xf8dad1e3 │ │ │ │ vqadd.s8 d16, d0, d4 │ │ │ │ @ instruction: 0xf2c03bf0 │ │ │ │ vqdmulh.s d16, d0, d5 │ │ │ │ @ instruction: 0xf2c03af4 │ │ │ │ tstcs r4, r5, lsl #20 │ │ │ │ andeq pc, r0, fp, asr #17 │ │ │ │ - blx ffd64700 │ │ │ │ + blx ffd646f8 │ │ │ │ andeq pc, r0, sl, asr #17 │ │ │ │ stmdacs r0, {r3, r5, r7, fp, sp, lr} │ │ │ │ sbcshi pc, r5, #0 │ │ │ │ @ instruction: 0xf7ea6904 │ │ │ │ - cdpcc 12, 0, cr14, cr1, cr10, {3} │ │ │ │ + cdpcc 12, 0, cr14, cr1, cr14, {3} │ │ │ │ andle r6, r1, ip, lsr #1 │ │ │ │ ldrb r4, [r4, r0, lsr #12]! │ │ │ │ ldrdcc pc, [r0], -fp │ │ │ │ @ instruction: 0xdc112b00 │ │ │ │ stmdavs r3, {r1, r2, r3, r4, sp, lr, pc} │ │ │ │ tstle r5, r5, lsl #22 │ │ │ │ ldrdcc pc, [r0], -sl │ │ │ │ andmi lr, r4, #208, 18 @ 0x340000 │ │ │ │ eorcs pc, r6, r3, asr #16 │ │ │ │ @ instruction: 0xf7ea3601 │ │ │ │ - @ instruction: 0xf8dbec54 │ │ │ │ + @ instruction: 0xf8dbec58 │ │ │ │ adcvs r3, ip, r0 │ │ │ │ - ble 3771fc │ │ │ │ + ble 3771f4 │ │ │ │ stccs 6, cr4, [r0], {32} │ │ │ │ @ instruction: 0xf7fad1eb │ │ │ │ adcvs pc, r8, pc, asr lr @ │ │ │ │ mvnle r2, r0, lsl #16 │ │ │ │ - cmppne ip, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppne r4, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - stc2 7, cr15, [lr, #936]! @ 0x3a8 │ │ │ │ + ldc2 7, cr15, [r2, #936]! @ 0x3a8 │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ stmdavs r6!, {r1, r3, r5, r7, r8, sl, pc} │ │ │ │ @ instruction: 0xf0402e04 │ │ │ │ @ instruction: 0xf8d485ad │ │ │ │ @ instruction: 0x4620b010 │ │ │ │ - ldc 7, cr15, [r4], #-936 @ 0xfffffc58 │ │ │ │ + ldc 7, cr15, [r8], #-936 @ 0xfffffc58 │ │ │ │ andlt pc, r8, r5, asr #17 │ │ │ │ svceq 0x0000f1bb │ │ │ │ mvnhi pc, #0 │ │ │ │ stmdbvs r3!, {r2, r3, r4, r6, r9, sl, lr} │ │ │ │ - blcs 38234 <__time64@plt+0x26f4c> │ │ │ │ + blcs 3822c <__time64@plt+0x26f44> │ │ │ │ mvnshi pc, #0 │ │ │ │ @ instruction: 0x4010f8da │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ stmiavs r9!, {r3, r4, r5, sl, pc} │ │ │ │ @ instruction: 0xf0002900 │ │ │ │ stmdbvs sl, {r1, r2, r3, sl, pc} │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ @@ -21829,44 +21827,44 @@ │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ @ instruction: 0xf1bb83c1 │ │ │ │ andle r0, r7, r0, lsl #30 │ │ │ │ ldrdne pc, [r0], -fp │ │ │ │ tstle r3, r3, lsl #18 │ │ │ │ ldmdavs r9, {r0, r1, r4, r8, ip, sp, pc} │ │ │ │ andle r2, r6, r5, lsl #18 │ │ │ │ - @ instruction: 0x11acf24e │ │ │ │ + @ instruction: 0x11a4f24e │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ea4658 │ │ │ │ - ldmdbvs r8, {r0, r2, r3, r5, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ - asrne pc, lr, #4 @ │ │ │ │ + ldmdbvs r8, {r0, r4, r5, r6, r8, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + orrsne pc, r8, lr, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - bl ff7647d8 │ │ │ │ + bl ff8647d0 │ │ │ │ svclt 0x00181e03 │ │ │ │ stccs 3, cr2, [r0], {1} │ │ │ │ @ instruction: 0xf043bf08 │ │ │ │ - blcs 27444 <__time64@plt+0x1615c> │ │ │ │ - blx feedafe4 │ │ │ │ + blcs 2743c <__time64@plt+0x16154> │ │ │ │ + blx feedafdc │ │ │ │ stmdavs r1!, {r1, r3, r7, r8, r9, ip, sp, lr, pc} │ │ │ │ stmdbcs r1, {r0, r1, r3, r4, r6, r8, fp} │ │ │ │ @ instruction: 0xf043bf18 │ │ │ │ - blcs 27458 <__time64@plt+0x16170> │ │ │ │ + blcs 27450 <__time64@plt+0x16168> │ │ │ │ @ instruction: 0xf8dad1de │ │ │ │ - blcs 7285c │ │ │ │ + blcs 72854 │ │ │ │ stmdbvs r1!, {r1, r3, r4, r6, r7, r8, ip, lr, pc}^ │ │ │ │ - blmi 1863164 │ │ │ │ - bleq 1a3368 │ │ │ │ + blmi 186315c │ │ │ │ + bleq 1a3360 │ │ │ │ strbtmi pc, [r8], #-576 @ 0xfffffdc0 @ │ │ │ │ streq pc, [r5], #-704 @ 0xfffffd40 │ │ │ │ @ instruction: 0xf8da68a8 │ │ │ │ ssatmi r3, #3, r4 │ │ │ │ andne pc, r0, fp, asr #17 │ │ │ │ stmdacs r0, {r0, r1, r5, sp, lr} │ │ │ │ eorshi pc, r7, #0 │ │ │ │ @ instruction: 0xf7ea6904 │ │ │ │ - vmlscc.f64 d14, d17, d12 │ │ │ │ + @ instruction: 0x3e01ebd0 │ │ │ │ andle r6, r1, ip, lsr #1 │ │ │ │ ldrb r4, [r4, r0, lsr #12]! │ │ │ │ @ instruction: 0xf8db2104 │ │ │ │ @ instruction: 0xf7f10000 │ │ │ │ vpmax.s8 , q0, │ │ │ │ vmlal.s q10, d0, d0[5] │ │ │ │ strmi r0, [r3], -r5, lsl #4 │ │ │ │ @@ -21879,47 +21877,47 @@ │ │ │ │ stmiavs ip!, {ip, sp} │ │ │ │ @ instruction: 0xf8cc2b00 │ │ │ │ vhadd.u8 d16, d0, d0 │ │ │ │ stmib sp, {r0, r1, r3, r4, r7, pc}^ │ │ │ │ ldrtmi r8, [r2], r9, lsl #14 │ │ │ │ ldrdhi pc, [ip], -sp │ │ │ │ vmax.s8 d20, d14, d23 │ │ │ │ - @ instruction: 0xf2c01ed0 │ │ │ │ + vqrdmlah.s d17, d16, d0[2] │ │ │ │ vceq.f32 d16, d14, d2 │ │ │ │ - vrshr.s64 d21, d4, #64 │ │ │ │ + vsubl.s8 , d16, d12 │ │ │ │ strls r0, [r5], -r2, lsl #4 │ │ │ │ eorls pc, ip, sp, asr #17 │ │ │ │ @ instruction: 0xec06e9cd │ │ │ │ svccs 0x00009208 │ │ │ │ teqphi r0, r0 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0x2c00693c │ │ │ │ adchi pc, pc, r0 │ │ │ │ @ instruction: 0xf1046922 │ │ │ │ - bcs 2814c <__time64@plt+0x16e64> │ │ │ │ + bcs 28144 <__time64@plt+0x16e5c> │ │ │ │ mrshi pc, (UNDEF: 64) @ │ │ │ │ ldrdls pc, [r0], -r7 │ │ │ │ @ instruction: 0xf1b99203 │ │ │ │ @ instruction: 0xf0400f03 │ │ │ │ stccs 0, cr8, [r0], {189} @ 0xbd │ │ │ │ adcshi pc, sl, r0 │ │ │ │ stmdacs r5, {r5, fp, sp, lr} │ │ │ │ adcshi pc, r6, r0, asr #32 │ │ │ │ stmdbls r6, {r1, r2, r5, r6, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf7ea4630 │ │ │ │ - bls 1216a0 │ │ │ │ + bls 1216a8 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ strmi r8, [r6], -sp, ror #1 │ │ │ │ @ instruction: 0xf0002a00 │ │ │ │ ldmdavs r1, {r0, r3, r5, r7, pc} │ │ │ │ @ instruction: 0xf0402901 │ │ │ │ ldmdbvs r7, {r0, r2, r5, r7, pc}^ │ │ │ │ stmdacs r0, {r3, r5, r7, fp, sp, lr} │ │ │ │ bichi pc, sp, r0 │ │ │ │ @ instruction: 0xf7ea6904 │ │ │ │ - @ instruction: 0xf1b9eb62 │ │ │ │ + @ instruction: 0xf1b9eb66 │ │ │ │ adcvs r0, ip, r1, lsl #18 │ │ │ │ strtmi sp, [r0], -r1 │ │ │ │ stccs 7, cr14, [r0], {243} @ 0xf3 │ │ │ │ sbcshi pc, lr, r0 │ │ │ │ stmdacs r0, {r5, r8, fp, sp, lr} │ │ │ │ mrshi pc, (UNDEF: 6) @ │ │ │ │ @ instruction: 0xf380fab0 │ │ │ │ @@ -21930,123 +21928,123 @@ │ │ │ │ stmdavs r2, {r5, r6, r7, pc} │ │ │ │ @ instruction: 0xf0402a04 │ │ │ │ @ instruction: 0xf10480dc │ │ │ │ @ instruction: 0x2e000914 │ │ │ │ addhi pc, r3, r0 │ │ │ │ strbmi r9, [sl], -r4, lsl #18 │ │ │ │ ldmibmi r9, {r3, fp, sp, lr} │ │ │ │ - blx 46496e │ │ │ │ + blx 564966 │ │ │ │ @ instruction: 0xf7f74606 │ │ │ │ strmi pc, [r3], -r5, lsl #24 │ │ │ │ @ instruction: 0x461e4630 │ │ │ │ - bl ce4964 │ │ │ │ + bl de495c │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ stmiavs r8!, {r0, r7, pc} │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ @ instruction: 0xf8436077 │ │ │ │ stmdacs r0, {r1, r3, r5, sp, lr} │ │ │ │ orrhi pc, pc, r0 │ │ │ │ @ instruction: 0xf7ea6906 │ │ │ │ - adcvs lr, lr, r4, lsr #22 │ │ │ │ + adcvs lr, lr, r8, lsr #22 │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ ldrtmi r8, [r0], -r8, lsl #3 │ │ │ │ @ instruction: 0xf7ea6937 │ │ │ │ - @ instruction: 0xf8dbeb1c │ │ │ │ + @ instruction: 0xf8dbeb20 │ │ │ │ @ instruction: 0xf10a3000 │ │ │ │ adcvs r0, pc, r1, lsl #20 │ │ │ │ @ instruction: 0xf6ff459a │ │ │ │ shsub16mi sl, ip, lr │ │ │ │ ldrdhi pc, [r4], -sp @ │ │ │ │ stmdbvc sl, {r0, r2, r3, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ stmdavs r3!, {r0, r4, r6, sl, pc} │ │ │ │ @ instruction: 0xf0402b04 │ │ │ │ @ instruction: 0xf8d48454 │ │ │ │ @ instruction: 0x4620a010 │ │ │ │ - bl e49c4 │ │ │ │ + bl 1e49bc │ │ │ │ andge pc, r8, r5, asr #17 │ │ │ │ svceq 0x0000f1ba │ │ │ │ strthi pc, [ip], #-0 │ │ │ │ @ instruction: 0x6010f8da │ │ │ │ @ instruction: 0xf0002e00 │ │ │ │ @ instruction: 0xf8d683f2 │ │ │ │ @ instruction: 0xf106b010 │ │ │ │ @ instruction: 0xf1bb0410 │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ @ instruction: 0xf8da840b │ │ │ │ stccs 0, cr4, [r3], {-0} │ │ │ │ tstlt lr, r4, lsl #2 │ │ │ │ - blcs 180b1c │ │ │ │ + blcs 180b14 │ │ │ │ adcshi pc, r7, r0 │ │ │ │ - msrcs (UNDEF: 96), lr │ │ │ │ + cmppcs r8, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ea4650 │ │ │ │ - ldrtmi pc, [r9], sp, asr #24 @ │ │ │ │ + ssatmi pc, #26, r1, asr #24 @ │ │ │ │ ldc2l 7, cr15, [r2], #1000 @ 0x3e8 │ │ │ │ strmi r6, [r4], -lr, lsr #17 │ │ │ │ mcrcs 1, 0, r6, cr0, cr8, {1} │ │ │ │ addshi pc, sl, r0, asr #32 │ │ │ │ stc2l 7, cr15, [sl], #1000 @ 0x3e8 │ │ │ │ adcvs r4, r8, r6, lsl #12 │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ stmdbvs r0, {r0, r3, r4, r6, r7, sl, pc} │ │ │ │ stmdacs r0, {r0, r1, r2, r3, r6, r9, sl, lr} │ │ │ │ rsbshi pc, r8, #0 │ │ │ │ - bcs 40e98 <__time64@plt+0x2fbb0> │ │ │ │ + bcs 40e90 <__time64@plt+0x2fba8> │ │ │ │ svccs 0x0000d07c │ │ │ │ svcge 0x003cf47f │ │ │ │ - bicsne pc, r8, lr, asr #4 │ │ │ │ + bicsne pc, r0, lr, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ea4638 │ │ │ │ - strbmi pc, [r8], -fp, lsr #24 @ │ │ │ │ - blx fe264a8a │ │ │ │ + strbmi pc, [r8], -pc, lsr #24 @ │ │ │ │ + blx fe264a82 │ │ │ │ strbmi r4, [r8], -r6, lsl #12 │ │ │ │ - bl 1be4a5c │ │ │ │ + bl 1ce4a54 │ │ │ │ stmdble r2, {r2, fp, sp} │ │ │ │ - blcs bc5f48 │ │ │ │ + blcs bc5f40 │ │ │ │ cdpcs 0, 0, cr13, cr0, cr13, {0} │ │ │ │ svcge 0x007ff47f │ │ │ │ - sbcsvs pc, r8, #77594624 @ 0x4a00000 │ │ │ │ + sbcsvs pc, r0, #77594624 @ 0x4a00000 │ │ │ │ andeq pc, r2, #192, 4 │ │ │ │ - rscvs pc, r8, sl, asr #12 │ │ │ │ + rscvs pc, r0, sl, asr #12 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ea216e │ │ │ │ - stclvc 12, cr15, [r3, #-988]! @ 0xfffffc24 │ │ │ │ + stclvc 12, cr15, [r3, #-1004]! @ 0xfffffc14 │ │ │ │ mvnle r2, pc, lsr #22 │ │ │ │ andeq lr, r0, #9216 @ 0x2400 │ │ │ │ stccc 8, cr15, [r2], {18} │ │ │ │ mvnle r2, lr, lsr #22 │ │ │ │ stccc 8, cr15, [r1], {18} │ │ │ │ mvnle r2, r8, ror #22 │ │ │ │ @ instruction: 0xf7f13801 │ │ │ │ @ instruction: 0xf104f92d │ │ │ │ @ instruction: 0x46040116 │ │ │ │ - b ffae4aac │ │ │ │ + b ffbe4aa4 │ │ │ │ ldmdavs sl, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ @ instruction: 0xf8429b05 │ │ │ │ movwcc r4, #4131 @ 0x1023 │ │ │ │ sbcsle r2, r7, r0, lsl #28 │ │ │ │ ldrb r9, [r4, -r5, lsl #6] │ │ │ │ ldrtmi r9, [r0], -r8, lsl #18 │ │ │ │ @ instruction: 0xf7ea9203 │ │ │ │ - bls 1214b4 │ │ │ │ + bls 1214bc │ │ │ │ @ instruction: 0xd1b72800 │ │ │ │ str r2, [r9, -r1, lsl #12] │ │ │ │ stc2 7, cr15, [lr], {250} @ 0xfa │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7faaf1b │ │ │ │ strmi pc, [r6], -r7, lsl #25 │ │ │ │ @ instruction: 0xb12060a8 │ │ │ │ ldmdblt r3, {r0, r1, r8, fp, sp, lr} │ │ │ │ stc2 7, cr15, [r0], {250} @ 0xfa │ │ │ │ vand d22, d14, d16 │ │ │ │ - vaddw.s8 q9, q0, d4 │ │ │ │ + vsra.s64 , q14, #64 │ │ │ │ strtmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx ff464b06 │ │ │ │ + blx ff564afe │ │ │ │ ldc2l 7, cr15, [r6], #-1000 @ 0xfffffc18 │ │ │ │ adcvs r4, r8, r7, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7faaec9 │ │ │ │ strmi pc, [r1], pc, ror #24 │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ strbthi pc, [r1], #-0 @ │ │ │ │ @@ -22065,33 +22063,33 @@ │ │ │ │ @ instruction: 0x464f6930 │ │ │ │ stmdacs r0, {r4, r9, sl, ip, sp} │ │ │ │ svcge 0x006cf47f │ │ │ │ mcrr2 7, 15, pc, sl, cr10 @ │ │ │ │ stmdacs r0, {r4, r5, sp, lr} │ │ │ │ svcge 0x0066f47f │ │ │ │ ldmdbvs r0!, {r0, r2, r3, r5, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ - cmppcs r4, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmppcs ip, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - b 364b78 │ │ │ │ + b 464b70 │ │ │ │ @ instruction: 0xf38bfabb │ │ │ │ stmdacs r0, {r0, r1, r3, r4, r6, r8, fp} │ │ │ │ @ instruction: 0xf043bf18 │ │ │ │ - blcs 277e4 <__time64@plt+0x164fc> │ │ │ │ + blcs 277dc <__time64@plt+0x164f4> │ │ │ │ svcge 0x0038f47f │ │ │ │ ldrdcc pc, [r0], -fp │ │ │ │ @ instruction: 0xf47f2b01 │ │ │ │ stmiavs r8!, {r0, r1, r4, r5, r8, r9, sl, fp, sp, pc} │ │ │ │ @ instruction: 0x3014f8db │ │ │ │ stmdacs r0, {r0, r1, r8, r9, ip, pc} │ │ │ │ stmdbvs r6, {r0, r1, r3, r4, r5, r6, ip, lr, pc} │ │ │ │ - b 464ba8 │ │ │ │ + b 564ba0 │ │ │ │ adcvs r3, lr, r1, lsl #24 │ │ │ │ ldrtmi sp, [r0], -r4 │ │ │ │ svclt 0x0000e7f5 │ │ │ │ - ldrdeq r2, [r3], -r4 │ │ │ │ + andeq r2, r3, ip, asr #13 │ │ │ │ mcrcs 6, 0, r4, cr0, cr3, {5} │ │ │ │ sbchi pc, sp, #0 │ │ │ │ @ instruction: 0x26004658 │ │ │ │ @ instruction: 0x46b24634 │ │ │ │ stmdavs r3, {r0, r1, r3, r4, r5, r7, r9, sl, lr} │ │ │ │ andsle r2, r1, r4, lsl #22 │ │ │ │ @ instruction: 0xf8cda80d │ │ │ │ @@ -22102,25 +22100,25 @@ │ │ │ │ rsbvs r6, r7, r8, lsr #17 │ │ │ │ subsle r2, r1, r0, lsl #16 │ │ │ │ ldrtmi r6, [ip], -r3, lsl #16 │ │ │ │ mvnle r2, r4, lsl #22 │ │ │ │ ldrbmi r6, [pc], -r8, lsr #17 │ │ │ │ suble r2, lr, r0, lsl #16 │ │ │ │ @ instruction: 0xf7ea6904 │ │ │ │ - blls 1213ec │ │ │ │ + blls 1213f4 │ │ │ │ strbmi r6, [r3, #-172] @ 0xffffff54 │ │ │ │ - ldrbhi pc, [pc], #-64 @ 26c64 <__time64@plt+0x1597c> @ │ │ │ │ + ldrbhi pc, [pc], #-64 @ 26c5c <__time64@plt+0x15974> @ │ │ │ │ ldrdcc pc, [r0], -r9 │ │ │ │ vstrle d2, [fp, #-4] │ │ │ │ movtvc pc, #49728 @ 0xc240 @ │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ - adcscs pc, r8, lr, asr #4 │ │ │ │ + adcscs pc, r0, lr, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldmdavs r9, {r0, r1, r9, fp, ip, pc} │ │ │ │ - stmib r0, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib r4, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ mvnscc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ stmiavs fp!, {r1, r2, r3, r4, sp, lr}^ │ │ │ │ @ instruction: 0xf013681b │ │ │ │ @ instruction: 0xf0400320 │ │ │ │ @ instruction: 0xf8d5840d │ │ │ │ movwls r8, #61448 @ 0xf008 │ │ │ │ @@ -22131,60 +22129,60 @@ │ │ │ │ @ instruction: 0xf8d4823b │ │ │ │ @ instruction: 0xf104a010 │ │ │ │ @ instruction: 0xf1ba0610 │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ @ instruction: 0xf8d8824e │ │ │ │ cdpcs 0, 0, cr6, cr3, cr0, {0} │ │ │ │ tstlt r4, r3, lsl #2 │ │ │ │ - blcs 180d5c │ │ │ │ + blcs 180d54 │ │ │ │ vqadd.s8 d29, d14, d1 │ │ │ │ - vaddw.s8 , q0, d24 │ │ │ │ + vaddw.s8 , q0, d16 │ │ │ │ strbmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx 3e4c8a │ │ │ │ + blx 4e4c82 │ │ │ │ ldrtmi r6, [lr], -r8, lsr #17 │ │ │ │ @ instruction: 0xd1ad2800 │ │ │ │ - blx fec64cd6 │ │ │ │ + blx fec64cce │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ @ instruction: 0xf7ead1a8 │ │ │ │ - stmdbvs r0!, {r0, r1, r3, r5, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ - tstpcc ip, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ + stmdbvs r0!, {r0, r1, r2, r3, r5, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ + tstpcc r4, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - ldmdb r2!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdb r6!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf38afaba │ │ │ │ stmdacs r0, {r0, r1, r3, r4, r6, r8, fp} │ │ │ │ @ instruction: 0xf043bf18 │ │ │ │ - blcs 27918 <__time64@plt+0x16630> │ │ │ │ + blcs 27910 <__time64@plt+0x16628> │ │ │ │ @ instruction: 0xf8dad1dd │ │ │ │ - blcs 72d1c │ │ │ │ + blcs 72d14 │ │ │ │ @ instruction: 0xf8dabf04 │ │ │ │ stmiavs r8!, {r2, r4, pc} │ │ │ │ stmdacs r0, {r0, r2, r4, r6, r7, r8, ip, lr, pc} │ │ │ │ stmdbvs r4, {r0, r1, r5, r6, r7, ip, lr, pc} │ │ │ │ - ldmdb r8!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdb ip!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ adcvs r3, ip, r1, lsl #28 │ │ │ │ strtmi sp, [r0], -r1 │ │ │ │ stmdage pc, {r0, r2, r4, r5, r6, r7, r8, r9, sl, sp, lr, pc} @ │ │ │ │ @ instruction: 0xff98f7fb │ │ │ │ strmi r6, [r6], -ip, lsr #17 │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ ldrmi r8, [r0, #478]! @ 0x1de │ │ │ │ mvnshi pc, #64 @ 0x40 │ │ │ │ - blcs 140de0 │ │ │ │ + blcs 140dd8 │ │ │ │ mvnhi pc, r0, asr #32 │ │ │ │ stmdbvs r4, {r3, r5, r7, fp, sp, lr} │ │ │ │ - stmdb r0!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb r4!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -r9 │ │ │ │ - blcs 7f018 │ │ │ │ + blcs 7f010 │ │ │ │ vadd.f32 d29, d0, d12 │ │ │ │ vqdmlal.s , d0, d0[3] │ │ │ │ ldrtmi r0, [r2], -r5, lsl #6 │ │ │ │ - andmi pc, r4, lr, asr #4 │ │ │ │ + rscscc pc, ip, lr, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ea6819 │ │ │ │ - stmiavs ip!, {r1, r6, r8, fp, sp, lr, pc} │ │ │ │ + stmiavs ip!, {r1, r2, r6, r8, fp, sp, lr, pc} │ │ │ │ movwmi pc, #49728 @ 0xc240 @ │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ andsvs r9, sl, pc, lsl #20 │ │ │ │ movwls r2, #58112 @ 0xe300 │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ @ instruction: 0xf8d4819e │ │ │ │ @ instruction: 0xf1b88010 │ │ │ │ @@ -22193,190 +22191,190 @@ │ │ │ │ @ instruction: 0xf108a010 │ │ │ │ @ instruction: 0xf1ba0610 │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ stmdavs r6!, {r7, r8, pc} │ │ │ │ tstle r6, r3, lsl #28 │ │ │ │ svceq 0x0000f1b8 │ │ │ │ @ instruction: 0xf8d8d003 │ │ │ │ - blcs 172dc8 │ │ │ │ + blcs 172dc0 │ │ │ │ vhadd.s8 d29, d14, d6 │ │ │ │ - vbic.i32 d20, #0 @ 0x00000000 │ │ │ │ + vaddw.s8 q10, q0, d24 │ │ │ │ strtmi r0, [r0], -r2, lsl #2 │ │ │ │ - blx fe4e4d80 │ │ │ │ + blx fe5e4d78 │ │ │ │ @ instruction: 0x0014f8d8 │ │ │ │ - msrmi R12_usr, lr │ │ │ │ + tstpmi ip, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ - stmdb r0, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r4, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ svclt 0x00181e03 │ │ │ │ @ instruction: 0xf1ba2301 │ │ │ │ svclt 0x00080f00 │ │ │ │ movweq pc, #4163 @ 0x1043 @ │ │ │ │ mvnle r2, r0, lsl #22 │ │ │ │ ldrdcc pc, [r0], -sl │ │ │ │ svclt 0x00042b01 │ │ │ │ @ instruction: 0x8014f8da │ │ │ │ bicsle r6, lr, r8, lsr #17 │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ stmdbvs r4, {r4, r5, r6, r8, r9, sl, fp, sp, pc} │ │ │ │ - stmdb r4, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r8, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ adcvs r3, ip, r1, lsl #28 │ │ │ │ strtmi sp, [r0], -r1 │ │ │ │ stmdage lr, {r2, r4, r5, r6, r7, r8, r9, sl, sp, lr, pc} │ │ │ │ @ instruction: 0xff24f7fb │ │ │ │ strmi r6, [r6], -ip, lsr #17 │ │ │ │ @ instruction: 0xf0002c00 │ │ │ │ ldrmi r8, [r0, #279]! @ 0x117 │ │ │ │ cmpphi fp, #64 @ p-variant is OBSOLETE @ 0x40 │ │ │ │ - blcs 140ec8 │ │ │ │ + blcs 140ec0 │ │ │ │ tstphi sl, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ stmdbvs r4, {r3, r5, r7, fp, sp, lr} │ │ │ │ - stmia ip!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm r0!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ tstpmi r0, #64, 4 @ p-variant is OBSOLETE │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ ldrdcs pc, [r0], -r9 │ │ │ │ - bcs 8d290 │ │ │ │ + bcs 8d288 │ │ │ │ andsvs r6, r9, ip, lsr #1 │ │ │ │ cmnlt ip, #7936 @ 0x1f00 │ │ │ │ @ instruction: 0x8010f8d4 │ │ │ │ svceq 0x0000f1b8 │ │ │ │ @ instruction: 0x81abf000 │ │ │ │ @ instruction: 0xa010f8d8 │ │ │ │ ldreq pc, [r0], -r8, lsl #2 │ │ │ │ svceq 0x0000f1ba │ │ │ │ @ instruction: 0x81bdf000 │ │ │ │ cdpcs 8, 0, cr6, cr3, cr6, {1} │ │ │ │ @ instruction: 0xf1b8d106 │ │ │ │ andle r0, r3, r0, lsl #30 │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ eorle r2, ip, r5, lsl #22 │ │ │ │ - teqppl r8, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ + teqppl r0, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ea4620 │ │ │ │ - vpmax.s8 d31, d0, d31 │ │ │ │ + vpmin.s8 d31, d0, d19 │ │ │ │ vqdmlal.s , d0, d0[3] │ │ │ │ ldrtmi r0, [r2], -r5, lsl #6 │ │ │ │ - andpl pc, r8, lr, asr #4 │ │ │ │ + andpl pc, r0, lr, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ @ instruction: 0xf7ea6819 │ │ │ │ - stmiavs ip!, {r3, r5, r7, fp, sp, lr, pc} │ │ │ │ + stmiavs ip!, {r2, r3, r5, r7, fp, sp, lr, pc} │ │ │ │ bicsle r2, r1, r0, lsl #24 │ │ │ │ - blx ff1e4ea8 │ │ │ │ + blx ff1e4ea0 │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ bicle r2, fp, r0, lsl #16 │ │ │ │ - blx ff064eb4 │ │ │ │ + blx ff064eac │ │ │ │ adcvs r4, r8, r0, lsl #13 │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ @ instruction: 0xf8d082c2 │ │ │ │ @ instruction: 0xf1bbb010 │ │ │ │ @ instruction: 0xf0000f00 │ │ │ │ @ instruction: 0x465882d0 │ │ │ │ ssatmi r4, #4, r8, asr #13 │ │ │ │ @ instruction: 0xf8d8e17d │ │ │ │ vqadd.s8 d16, d14, d4 │ │ │ │ - vaddw.s8 , q0, d28 │ │ │ │ + vaddw.s8 , q0, d20 │ │ │ │ @ instruction: 0xf7ea0102 │ │ │ │ - mcrne 8, 0, lr, cr3, cr8, {3} │ │ │ │ + mcrne 8, 0, lr, cr3, cr12, {3} │ │ │ │ movwcs fp, #7960 @ 0x1f18 │ │ │ │ svceq 0x0000f1ba │ │ │ │ @ instruction: 0xf043bf08 │ │ │ │ - blcs 27b10 <__time64@plt+0x16828> │ │ │ │ + blcs 27b08 <__time64@plt+0x16820> │ │ │ │ @ instruction: 0xf8dad1c0 │ │ │ │ - blcs 132f14 │ │ │ │ + blcs 132f0c │ │ │ │ stmiavs r8!, {r3, r8, r9, sl, fp, ip, sp, pc} │ │ │ │ stmdacs r0, {r1, r3, r4, r5, r7, r8, ip, lr, pc} │ │ │ │ mcrge 4, 7, pc, cr9, cr15, {1} @ │ │ │ │ @ instruction: 0xf7ea6904 │ │ │ │ - mcrcc 8, 0, lr, cr1, cr14, {3} │ │ │ │ + cdpcc 8, 0, cr14, cr1, cr2, {4} │ │ │ │ andle r6, r1, ip, lsr #1 │ │ │ │ ldrb r4, [r4, r0, lsr #12]! │ │ │ │ ldrdcc pc, [r0], -r9 │ │ │ │ vldrle d2, [r6, #-0] │ │ │ │ movtvc pc, #49728 @ 0xc240 @ │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ ldmdavs ip, {r3, r5, r6, r7, fp, sp, lr} │ │ │ │ - ldmda sl!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda lr!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ vmax.s8 d20, d14, d2 │ │ │ │ - vmov.i32 , #8 @ 0x00000008 │ │ │ │ + vmov.i32 , #0 @ 0x00000000 │ │ │ │ strtmi r0, [r1], -r2 │ │ │ │ - ldmda r6, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda sl, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ mvncc pc, #64, 4 │ │ │ │ movweq pc, #21184 @ 0x52c0 @ │ │ │ │ @ instruction: 0xf7ea6818 │ │ │ │ - stmiavs r8!, {r2, r3, r5, r7, fp, sp, lr, pc}^ │ │ │ │ - stmdb r2!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmiavs r8!, {r4, r5, r7, fp, sp, lr, pc}^ │ │ │ │ + stmdb r6!, {r1, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ strhtvs r8, [r8], #33 @ 0x21 │ │ │ │ andslt r6, r1, r8, rrx │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xe6193610 │ │ │ │ tstls r3, r5, lsl #6 │ │ │ │ - blx 18e4f70 │ │ │ │ + blx 18e4f68 │ │ │ │ strmi r9, [r2], r3, lsl #18 │ │ │ │ tstvs r8, r5, lsl #22 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf04fac34 │ │ │ │ ldrt r0, [r0], #-2560 @ 0xfffff600 │ │ │ │ - blx 15e4f88 │ │ │ │ + blx 15e4f80 │ │ │ │ adcvs r4, r8, r3, lsl #13 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7faac0d │ │ │ │ strmi pc, [r4], -pc, asr #20 │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ stcge 4, cr15, [r7], {127} @ 0x7f │ │ │ │ and r4, r5, fp, asr r6 │ │ │ │ - blx 11e4fa8 │ │ │ │ + blx 11e4fa0 │ │ │ │ stmiavs ip!, {r5, r8, sp, lr} │ │ │ │ ldmdblt r4!, {r0, r1, r9, sl, lr} │ │ │ │ @ instruction: 0xf7fa9303 │ │ │ │ - blls 1258cc │ │ │ │ + blls 1258c4 │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ @ instruction: 0xf8d4b198 │ │ │ │ @ instruction: 0xf1baa010 │ │ │ │ @ instruction: 0xf47f0f00 │ │ │ │ movwls sl, #15351 @ 0x3bf7 │ │ │ │ - blx ce4fd0 │ │ │ │ + blx ce4fc8 │ │ │ │ strmi r9, [r2], r3, lsl #22 │ │ │ │ stmdacs r0, {r5, r8, sp, lr} │ │ │ │ - blge ffbe41f0 │ │ │ │ + blge ffbe41e8 │ │ │ │ strcs r6, [r0], #-2217 @ 0xfffff757 │ │ │ │ @ instruction: 0xf47f2900 │ │ │ │ movwls sl, #15346 @ 0x3bf2 │ │ │ │ - blx 964fec │ │ │ │ + blx 964fe4 │ │ │ │ strmi r9, [r1], -r3, lsl #22 │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ stmdbvs sl, {r0, r1, r6, r7, ip, lr, pc} │ │ │ │ @ instruction: 0xf47f2a00 │ │ │ │ movwls sl, #23530 @ 0x5bea │ │ │ │ @ instruction: 0xf7fa9103 │ │ │ │ stmdbls r3, {r0, r1, r2, r4, r9, fp, ip, sp, lr, pc} │ │ │ │ - blls 17882c │ │ │ │ + blls 178824 │ │ │ │ stmdacs r0, {r3, r8, sp, lr} │ │ │ │ ldmdbvs r1, {r0, r2, r4, r5, r7, ip, lr, pc} │ │ │ │ @ instruction: 0xf47f2900 │ │ │ │ movwls sl, #23520 @ 0x5be0 │ │ │ │ @ instruction: 0xf7fa9203 │ │ │ │ - bls 125860 │ │ │ │ - blls 178844 │ │ │ │ + bls 125858 │ │ │ │ + blls 17883c │ │ │ │ stmdacs r0, {r4, r8, sp, lr} │ │ │ │ - blge ff5a4244 │ │ │ │ + blge ff5a423c │ │ │ │ movwls lr, #14245 @ 0x37a5 │ │ │ │ @ instruction: 0xf9fef7fa │ │ │ │ strmi r9, [r4], -r3, lsl #22 │ │ │ │ andseq pc, r0, sl, asr #17 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xe7c9abbe │ │ │ │ @ instruction: 0xf9f4f7fa │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ ldrmi sl, [r0, #3810]! @ 0xee2 │ │ │ │ subshi pc, r2, #64 @ 0x40 │ │ │ │ mvnmi pc, lr, asr #4 │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ea4620 │ │ │ │ - @ instruction: 0x46a3f93d │ │ │ │ + strtmi pc, [r3], r1, asr #18 │ │ │ │ @ instruction: 0xf9e2f7fa │ │ │ │ stmiavs ip!, {r5, r8, sp, lr} │ │ │ │ stmdblt r4!, {r7, r9, sl, lr} │ │ │ │ @ instruction: 0xf9dcf7fa │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ stmdbvs r0!, {r4, r5, r7, r8, ip, sp, pc} │ │ │ │ @ instruction: 0xf7fab918 │ │ │ │ @@ -22407,17 +22405,17 @@ │ │ │ │ ssatmi r4, #4, r8, asr #13 │ │ │ │ @ instruction: 0xf7fae7cf │ │ │ │ strmi pc, [r4], -r1, lsr #19 │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ mrcge 4, 0, APSR_nzcv, cr11, cr15, {3} │ │ │ │ @ instruction: 0xf04045b0 │ │ │ │ vand q12, q15, │ │ │ │ - vmla.f d19, d16, d0[7] │ │ │ │ + vmla.f d19, d16, d0[5] │ │ │ │ strtmi r0, [r0], -r2, lsl #2 │ │ │ │ - @ instruction: 0xf8eaf7ea │ │ │ │ + @ instruction: 0xf8eef7ea │ │ │ │ @ instruction: 0xf7fa46c3 │ │ │ │ stmiavs lr!, {r0, r1, r2, r3, r7, r8, fp, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf8c84604 │ │ │ │ stmdblt r6!, {r4} │ │ │ │ @ instruction: 0xf988f7fa │ │ │ │ adcvs r4, r8, r6, lsl #12 │ │ │ │ ldmdbvs r0!, {r3, r4, r5, r7, r8, ip, sp, pc} │ │ │ │ @@ -22429,15 +22427,15 @@ │ │ │ │ @ instruction: 0xf100d106 │ │ │ │ @ instruction: 0xf7fa0610 │ │ │ │ @ instruction: 0x4682f975 │ │ │ │ @ instruction: 0xb1286030 │ │ │ │ svceq 0x0000f1b8 │ │ │ │ stcge 4, cr15, [r9, #508]! @ 0x1fc │ │ │ │ ldrbmi lr, [r8], pc, lsr #11 │ │ │ │ - beq 632b4 │ │ │ │ + beq 632ac │ │ │ │ svceq 0x0000f1b8 │ │ │ │ stcge 4, cr15, [r1, #508]! @ 0x1fc │ │ │ │ @ instruction: 0xf7fae5a7 │ │ │ │ strmi pc, [r0], r3, ror #18 │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ stcge 4, cr15, [ip, #508] @ 0x1fc │ │ │ │ @ instruction: 0xf95cf7fa │ │ │ │ @@ -22472,76 +22470,76 @@ │ │ │ │ @ instruction: 0xe643ae3b │ │ │ │ @ instruction: 0xf04f465c │ │ │ │ @ instruction: 0x2c000a00 │ │ │ │ mrcge 4, 1, APSR_nzcv, cr4, cr15, {3} │ │ │ │ @ instruction: 0x4652e63c │ │ │ │ @ instruction: 0xf7fa9203 │ │ │ │ stmiavs ip!, {r0, r1, r2, r4, r8, fp, ip, sp, lr, pc} │ │ │ │ - bls f8a3c │ │ │ │ + bls f8a34 │ │ │ │ andseq pc, r0, sl, asr #17 │ │ │ │ andls fp, r3, #52, 18 @ 0xd0000 │ │ │ │ @ instruction: 0xf90ef7fa │ │ │ │ strmi r9, [r4], -r3, lsl #20 │ │ │ │ bicslt r6, r0, r8, lsr #1 │ │ │ │ stmdblt r8!, {r5, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf7fa9203 │ │ │ │ - bls 125658 │ │ │ │ + bls 125650 │ │ │ │ orrslt r6, r0, r0, lsr #2 │ │ │ │ @ instruction: 0xb010f8d0 │ │ │ │ @ instruction: 0xf1bb4692 │ │ │ │ tstle r6, r0, lsl #30 │ │ │ │ ldreq pc, [r0], #-256 @ 0xffffff00 │ │ │ │ @ instruction: 0xf8f8f7fa │ │ │ │ eorvs r4, r0, r3, lsl #13 │ │ │ │ @ instruction: 0xf1bab130 │ │ │ │ @ instruction: 0xf47f0f00 │ │ │ │ @ instruction: 0xf7ffabec │ │ │ │ @ instruction: 0x4692bbf3 │ │ │ │ - bleq 633b0 │ │ │ │ + bleq 633a8 │ │ │ │ svceq 0x0000f1ba │ │ │ │ - blge ff924478 │ │ │ │ - bllt ffae527c │ │ │ │ + blge ff924470 │ │ │ │ + bllt ffae5274 │ │ │ │ @ instruction: 0xf8e4f7fa │ │ │ │ adcvs r4, r8, r2, lsl #13 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7faabcd │ │ │ │ @ instruction: 0x4606f8dd │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ rschi pc, pc, r0 │ │ │ │ - bcs 416a8 <__time64@plt+0x303c0> │ │ │ │ + bcs 416a0 <__time64@plt+0x303b8> │ │ │ │ rschi pc, sp, r0 │ │ │ │ @ instruction: 0x46164610 │ │ │ │ @ instruction: 0xe7cd4652 │ │ │ │ @ instruction: 0xf8cef7fa │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ vqdmulh.s d26, d30, d24 │ │ │ │ - vaddw.s8 q9, q0, d28 │ │ │ │ + vaddw.s8 q9, q0, d20 │ │ │ │ strtmi r0, [r0], -r2, lsl #2 │ │ │ │ - @ instruction: 0xf81af7ea │ │ │ │ + @ instruction: 0xf81ef7ea │ │ │ │ @ instruction: 0xf8c0f7fa │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7faa91b │ │ │ │ @ instruction: 0x4606f8b9 │ │ │ │ @ instruction: 0xb12860a8 │ │ │ │ ldmdblt r3, {r0, r1, r8, fp, sp, lr} │ │ │ │ @ instruction: 0xf8b2f7fa │ │ │ │ @ instruction: 0x46266130 │ │ │ │ - msreq (UNDEF: 104), lr │ │ │ │ + msreq (UNDEF: 96), lr │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7ea4630 │ │ │ │ - @ instruction: 0xf7faf801 │ │ │ │ + @ instruction: 0xf7faf805 │ │ │ │ strmi pc, [r4], -r7, lsr #17 │ │ │ │ stmdacs r0, {r3, r5, r7, sp, lr} │ │ │ │ - bge 1424504 │ │ │ │ - cmnpne r4, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ + bge 14244fc │ │ │ │ + msrne (UNDEF: 108), lr │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7e94620 │ │ │ │ - usub8mi pc, r9, r3 @ │ │ │ │ + usub8mi pc, r9, r7 @ │ │ │ │ @ instruction: 0xf7fa9103 │ │ │ │ stmiavs lr!, {r0, r1, r2, r4, r7, fp, ip, sp, lr, pc} │ │ │ │ stmdbls r3, {r2, r9, sl, lr} │ │ │ │ andseq pc, r0, fp, asr #17 │ │ │ │ tstls r3, r6, lsr r9 │ │ │ │ @ instruction: 0xf88ef7fa │ │ │ │ strmi r9, [r6], -r3, lsl #18 │ │ │ │ @@ -22556,15 +22554,15 @@ │ │ │ │ ldreq pc, [r0], -r0, lsl #2 │ │ │ │ @ instruction: 0xf878f7fa │ │ │ │ eorsvs r4, r0, r2, lsl #13 │ │ │ │ @ instruction: 0xf1bbb130 │ │ │ │ @ instruction: 0xf47f0f00 │ │ │ │ @ instruction: 0xf7ffa9b6 │ │ │ │ @ instruction: 0x468bb9bc │ │ │ │ - beq 634b0 │ │ │ │ + beq 634a8 │ │ │ │ svceq 0x0000f1bb │ │ │ │ stmibge sp!, {r0, r1, r2, r3, r4, r5, r6, sl, ip, sp, lr, pc} │ │ │ │ ldmiblt r3!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf864f7fa │ │ │ │ adcvs r4, r8, r3, lsl #13 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7faa997 │ │ │ │ @@ -22576,15 +22574,15 @@ │ │ │ │ @ instruction: 0xe7cf4659 │ │ │ │ @ instruction: 0xf850f7fa │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7faa951 │ │ │ │ strmi pc, [r4], -r9, asr #16 │ │ │ │ tstlt r0, r8, lsr #1 │ │ │ │ - blcs 417d0 <__time64@plt+0x304e8> │ │ │ │ + blcs 417c8 <__time64@plt+0x304e0> │ │ │ │ strcs sp, [r0], #-60 @ 0xffffffc4 │ │ │ │ ldmlt pc!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ @ │ │ │ │ @ instruction: 0xf83ef7fa │ │ │ │ stmdacs r0, {r5, r8, sp, lr} │ │ │ │ ldmge r3!, {r0, r1, r2, r3, r4, r5, r6, sl, ip, sp, lr, pc}^ │ │ │ │ ldmlt r7!, {r0, r1, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf836f7fa │ │ │ │ @@ -22594,141 +22592,141 @@ │ │ │ │ @ instruction: 0xf82ef7fa │ │ │ │ adcvs r4, r8, r4, lsl #12 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7faa8b2 │ │ │ │ strmi pc, [r6], -r7, lsr #16 │ │ │ │ smlatblt r8, r8, r0, r6 │ │ │ │ @ instruction: 0xb3236903 │ │ │ │ - cmnpeq ip, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ + cmnpeq r4, lr, asr #4 @ p-variant is OBSOLETE │ │ │ │ smlabteq r2, r0, r2, pc @ │ │ │ │ @ instruction: 0xf7e94620 │ │ │ │ - @ instruction: 0xf7faff73 │ │ │ │ + @ instruction: 0xf7faff77 │ │ │ │ msrvs CPSR_, r9, lsl r8 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xf7ffa91f │ │ │ │ @ instruction: 0xf7fab8d2 │ │ │ │ msrvs CPSR_, r1, lsl r8 │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0xe7e9a89a │ │ │ │ @ instruction: 0xf7ff464f │ │ │ │ @ instruction: 0x463cbbb2 │ │ │ │ - bllt 6e543c │ │ │ │ + bllt 6e5434 │ │ │ │ @ instruction: 0xf804f7fa │ │ │ │ ldr r6, [lr, r0, lsr #2]! │ │ │ │ @ instruction: 0xf7e9210a │ │ │ │ - @ instruction: 0xf7ffeefe │ │ │ │ + @ instruction: 0xf7ffef02 │ │ │ │ @ instruction: 0xf7f9b8e2 │ │ │ │ teqpvs r0, fp @ @ p-variant is OBSOLETE │ │ │ │ ssatmi lr, #4, r6, asr #15 │ │ │ │ @ instruction: 0x46a3e6b8 │ │ │ │ pkhbtmi lr, r3, r6, lsl #12 │ │ │ │ @ instruction: 0xf7f9e668 │ │ │ │ strdvs pc, [r0, -r1]! │ │ │ │ @ instruction: 0xf47f2800 │ │ │ │ @ instruction: 0x4626a851 │ │ │ │ @ instruction: 0x4601e73a │ │ │ │ @ instruction: 0x4602e757 │ │ │ │ pkhtbmi lr, r2, r5, asr #13 │ │ │ │ strmi lr, [r4], -sl, asr #13 │ │ │ │ @ instruction: 0xf7e9e69e │ │ │ │ - stmdavs r0, {r1, r2, r3, r4, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ - cdp2 7, 1, cr15, cr14, cr13, {7} │ │ │ │ + stmdavs r0, {r1, r5, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + cdp2 7, 2, cr15, cr2, cr13, {7} │ │ │ │ @ instruction: 0x46024639 │ │ │ │ - andseq pc, r0, lr, asr #4 │ │ │ │ + andeq pc, r8, lr, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - @ instruction: 0xffbcf7e9 │ │ │ │ + @ instruction: 0xffc0f7e9 │ │ │ │ ldr r4, [r9, -r3, lsl #13]! │ │ │ │ strb r4, [sp, #1540]! @ 0x604 │ │ │ │ ldrt r4, [lr], -r0, lsl #13 │ │ │ │ strtmi r4, [r1], r7, lsl #12 │ │ │ │ - blt ff6654b0 │ │ │ │ + blt ff6654a8 │ │ │ │ strpl lr, [r0], #-2517 @ 0xfffff62b │ │ │ │ - cdp 7, 8, cr15, cr4, cr9, {7} │ │ │ │ + cdp 7, 8, cr15, cr8, cr9, {7} │ │ │ │ @ instruction: 0xf7ed6800 │ │ │ │ - strtmi pc, [sl], -r5, lsl #28 │ │ │ │ + strtmi pc, [sl], -r9, lsl #28 │ │ │ │ strtmi r4, [r1], -r3, lsl #12 │ │ │ │ - sbcscs pc, ip, lr, asr #4 │ │ │ │ + sbcscs pc, r4, lr, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ - @ instruction: 0xffa2f7e9 │ │ │ │ - cdp 7, 7, cr15, cr6, cr9, {7} │ │ │ │ + @ instruction: 0xffa6f7e9 │ │ │ │ + cdp 7, 7, cr15, cr10, cr9, {7} │ │ │ │ @ instruction: 0xf7ed6800 │ │ │ │ - @ instruction: 0x4639fdf7 │ │ │ │ + @ instruction: 0x4639fdfb │ │ │ │ vmax.s8 d20, d14, d2 │ │ │ │ - vmla.i d21, d0, d0[7] │ │ │ │ + vmla.i d21, d0, d0[5] │ │ │ │ @ instruction: 0xf7e90002 │ │ │ │ - stmib sp, {r0, r2, r4, r7, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + stmib sp, {r0, r3, r4, r7, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ vmax.s8 d24, d14, d0 │ │ │ │ - vmla.i d20, d0, d0[2] │ │ │ │ + vmla.i d20, d0, d0[0] │ │ │ │ ldmib r4, {r1}^ │ │ │ │ stmiavs r1!, {r0, r8, r9, sp}^ │ │ │ │ - @ instruction: 0xff8af7e9 │ │ │ │ - addscc pc, ip, lr, asr #4 │ │ │ │ + @ instruction: 0xff8ef7e9 │ │ │ │ + addscc pc, r4, lr, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldrdcs lr, [r0, -r5] │ │ │ │ strls r4, [r0], -r3, asr #12 │ │ │ │ - @ instruction: 0xff80f7e9 │ │ │ │ - addsmi pc, ip, lr, asr #4 │ │ │ │ + @ instruction: 0xff84f7e9 │ │ │ │ + addsmi pc, r4, lr, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ ldmib r5, {r2, r4, r5, r6, r7, r8, r9, sl, sp, lr, pc}^ │ │ │ │ vrhadd.s8 d18, d14, d0 │ │ │ │ - vmvn.i32 q9, #8 @ 0x00000008 │ │ │ │ - blls e7538 │ │ │ │ + vmvn.i32 q9, #0 @ 0x00000000 │ │ │ │ + blls e7530 │ │ │ │ andhi pc, r0, sp, asr #17 │ │ │ │ - @ instruction: 0xff70f7e9 │ │ │ │ + @ instruction: 0xff74f7e9 │ │ │ │ stmdavs r0, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - adceq pc, r4, lr, asr #4 │ │ │ │ + addseq pc, ip, lr, asr #4 │ │ │ │ andeq pc, r2, r0, asr #5 │ │ │ │ movwcs lr, #6612 @ 0x19d4 │ │ │ │ @ instruction: 0xf7e968e1 │ │ │ │ - stmib sp, {r0, r2, r5, r6, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ + stmib sp, {r0, r3, r5, r6, r8, r9, sl, fp, ip, sp, lr, pc}^ │ │ │ │ vmax.s8 d24, d14, d0 │ │ │ │ - vmla.i d19, d0, d0[2] │ │ │ │ + vmla.i d19, d0, d0[0] │ │ │ │ ldmib r4, {r1}^ │ │ │ │ stmiavs r1!, {r0, r8, r9, sp}^ │ │ │ │ - @ instruction: 0xff5af7e9 │ │ │ │ + @ instruction: 0xff5ef7e9 │ │ │ │ strmi r7, [r4], r3, lsl #16 │ │ │ │ cmnle r8, lr, lsr #22 │ │ │ │ - bicsvs pc, r8, r2, asr #4 │ │ │ │ + bicsvs pc, r0, r2, asr #4 │ │ │ │ smlabteq r3, r0, r2, pc @ │ │ │ │ svccs 0x0001f810 │ │ │ │ svccc 0x0001f811 │ │ │ │ - bl fe8f1d80 │ │ │ │ - blx fece818c │ │ │ │ - b 1424394 │ │ │ │ + bl fe8f1d78 │ │ │ │ + blx fece8184 │ │ │ │ + b 142438c │ │ │ │ svclt 0x00081353 │ │ │ │ - blcs 30190 <__time64@plt+0x1eea8> │ │ │ │ + blcs 30188 <__time64@plt+0x1eea0> │ │ │ │ strmi sp, [r4, #496] @ 0x1f0 │ │ │ │ - bl fe85bf24 │ │ │ │ + bl fe85bf1c │ │ │ │ @ instruction: 0xf013030c │ │ │ │ eorle r0, fp, r7, lsl #6 │ │ │ │ eorle r2, r2, r1, lsl #22 │ │ │ │ andsle r2, fp, r2, lsl #22 │ │ │ │ andsle r2, r4, r3, lsl #22 │ │ │ │ andle r2, sp, r4, lsl #22 │ │ │ │ andle r2, r6, r5, lsl #22 │ │ │ │ cmple r3, r6, lsl #22 │ │ │ │ @ instruction: 0xf8104601 │ │ │ │ - blcs bf69c4 │ │ │ │ + blcs bf69bc │ │ │ │ @ instruction: 0x4601d053 │ │ │ │ stccc 8, cr15, [r1, #-64] @ 0xffffffc0 │ │ │ │ suble r2, lr, pc, lsr #22 │ │ │ │ @ instruction: 0xf8104601 │ │ │ │ - blcs bf69d8 │ │ │ │ + blcs bf69d0 │ │ │ │ strmi sp, [r1], -r9, asr #32 │ │ │ │ stccc 8, cr15, [r1, #-64] @ 0xffffffc0 │ │ │ │ suble r2, r4, pc, lsr #22 │ │ │ │ @ instruction: 0xf8104601 │ │ │ │ - blcs bf69ec │ │ │ │ + blcs bf69e4 │ │ │ │ @ instruction: 0x4601d03f │ │ │ │ stccc 8, cr15, [r1, #-64] @ 0xffffffc0 │ │ │ │ eorsle r2, sl, pc, lsr #22 │ │ │ │ eorsle r4, sl, r4, lsl #11 │ │ │ │ stccc 8, cr15, [r1], {16} │ │ │ │ strmi r1, [r1], -r2, asr #28 │ │ │ │ - blcs beef44 │ │ │ │ + blcs beef3c │ │ │ │ @ instruction: 0xf812d031 │ │ │ │ ldrmi r3, [r1], -r1, lsl #24 │ │ │ │ eorle r2, ip, pc, lsr #22 │ │ │ │ stccc 8, cr15, [r2], {18} │ │ │ │ cdpne 6, 9, cr4, cr0, cr1, {0} │ │ │ │ eorle r2, r6, pc, lsr #22 │ │ │ │ stccc 8, cr15, [r3], {18} │ │ │ │ @@ -22745,162 +22743,162 @@ │ │ │ │ andle r2, lr, pc, lsr #22 │ │ │ │ stccc 8, cr15, [r7], {18} │ │ │ │ svcne 0x00d04601 │ │ │ │ andle r2, r8, pc, lsr #22 │ │ │ │ bicle r4, sp, r4, lsl #11 │ │ │ │ @ instruction: 0x47704770 │ │ │ │ @ instruction: 0xf8104601 │ │ │ │ - blcs bf6a6c │ │ │ │ + blcs bf6a64 │ │ │ │ strmi sp, [r8], -r6, lsr #3 │ │ │ │ @ instruction: 0x47704770 │ │ │ │ push {r1, r2, r3, sl, ip, sp, pc} │ │ │ │ @ instruction: 0x460741f0 │ │ │ │ addlt r2, r3, r0, lsl #8 │ │ │ │ @ instruction: 0xf855ad09 │ │ │ │ strls r8, [r1, #-2820] @ 0xfffff4fc │ │ │ │ strbmi r4, [r3], -lr, lsr #12 │ │ │ │ @ instruction: 0xb12b4618 │ │ │ │ - stc 7, cr15, [r0, #932] @ 0x3a4 │ │ │ │ - blcc 1657ec │ │ │ │ + stc 7, cr15, [r4, #932] @ 0x3a4 │ │ │ │ + blcc 1657e4 │ │ │ │ ldrb r4, [r7, r4, lsl #8]! │ │ │ │ @ instruction: 0xf7f01c60 │ │ │ │ @ instruction: 0x4641fb5b │ │ │ │ strmi r4, [r4], -sl, lsr #12 │ │ │ │ @ instruction: 0xf7ef9501 │ │ │ │ - tstplt r7, r3, lsl #26 @ p-variant is OBSOLETE │ │ │ │ + tstplt r7, r7, lsl #26 @ p-variant is OBSOLETE │ │ │ │ @ instruction: 0xf7e94638 │ │ │ │ - @ instruction: 0x4620ecb8 │ │ │ │ + @ instruction: 0x4620ecbc │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ strdlt r4, [r3], -r0 │ │ │ │ svclt 0x00004770 │ │ │ │ ldrlt fp, [r0, #-1039]! @ 0xfffffbf1 │ │ │ │ addlt r2, r3, r0, lsl #10 │ │ │ │ @ instruction: 0xf854ac06 │ │ │ │ strls r3, [r1], #-2820 @ 0xfffff4fc │ │ │ │ @ instruction: 0xb12b4618 │ │ │ │ - ldcl 7, cr15, [ip, #-932] @ 0xfffffc5c │ │ │ │ - blcc 16582c │ │ │ │ + stcl 7, cr15, [r0, #-932]! @ 0xfffffc5c │ │ │ │ + blcc 165824 │ │ │ │ ldrb r4, [r7, r5, lsl #8]! │ │ │ │ andlt r4, r3, r8, lsr #12 │ │ │ │ ldrhtmi lr, [r0], -sp │ │ │ │ ldrbmi fp, [r0, -r4]! │ │ │ │ ldrlt fp, [r0, #-1039] @ 0xfffffbf1 │ │ │ │ addlt r4, r2, r7, lsl #24 │ │ │ │ ldrbtmi sl, [ip], #-2564 @ 0xfffff5fc │ │ │ │ - blne 165844 │ │ │ │ + blne 16583c │ │ │ │ andls r6, r1, #32, 16 @ 0x200000 │ │ │ │ - ldc2l 7, cr15, [r6], {239} @ 0xef │ │ │ │ + ldc2l 7, cr15, [sl], {239} @ 0xef │ │ │ │ andlt r6, r2, r0, lsr #16 │ │ │ │ @ instruction: 0x4010e8bd │ │ │ │ ldrbmi fp, [r0, -r4]! │ │ │ │ - andeq r9, r2, sl, lsl #3 │ │ │ │ - ldcllt 7, cr15, [r0, #932] @ 0x3a4 │ │ │ │ + muleq r2, r2, r1 │ │ │ │ + ldcllt 7, cr15, [r4, #932] @ 0x3a4 │ │ │ │ @ instruction: 0x460cb538 │ │ │ │ - blx ffbe56e0 │ │ │ │ + blx ffbe56d8 │ │ │ │ strtmi r4, [r0], -r5, lsl #12 │ │ │ │ - blx ffae56e8 │ │ │ │ + blx ffae56e0 │ │ │ │ strtmi r4, [r1], -r4, lsl #12 │ │ │ │ @ instruction: 0xf7e94628 │ │ │ │ - @ instruction: 0x4603ec5c │ │ │ │ + strmi lr, [r3], -r0, ror #24 │ │ │ │ ldrmi r4, [sp], -r8, lsr #12 │ │ │ │ - ldcl 7, cr15, [r2], #-932 @ 0xfffffc5c │ │ │ │ + ldcl 7, cr15, [r6], #-932 @ 0xfffffc5c │ │ │ │ @ instruction: 0xf7e94620 │ │ │ │ - blx feda2904 │ │ │ │ + blx feda290c │ │ │ │ stmdbeq r0, {r0, r2, r7, ip, sp, lr, pc}^ │ │ │ │ svclt 0x0000bd38 │ │ │ │ stcmi 5, cr11, [sp], {16} │ │ │ │ ldrbtmi r4, [ip], #-2829 @ 0xfffff4f3 │ │ │ │ ldmdavs r8, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ tstcs r2, r0, lsl r1 │ │ │ │ - stcl 7, cr15, [lr, #-932] @ 0xfffffc5c │ │ │ │ + ldcl 7, cr15, [r2, #-932] @ 0xfffffc5c │ │ │ │ stmiapl r3!, {r1, r3, r8, r9, fp, lr}^ │ │ │ │ tstlt r0, r8, lsl r8 │ │ │ │ @ instruction: 0xf7e92102 │ │ │ │ - blmi 262c90 │ │ │ │ + blmi 262c98 │ │ │ │ ldmdavs r8, {r0, r1, r5, r6, r7, fp, ip, lr} │ │ │ │ pop {r5, r8, ip, sp, pc} │ │ │ │ tstcs r2, r0, lsl r0 │ │ │ │ - ldclt 7, cr15, [ip, #-932]! @ 0xfffffc5c │ │ │ │ + stcllt 7, cr15, [r0, #-932] @ 0xfffffc5c │ │ │ │ svclt 0x0000bd10 │ │ │ │ - andeq r8, r2, lr, lsr #17 │ │ │ │ + @ instruction: 0x000288b6 │ │ │ │ andeq r0, r0, ip, lsr r1 │ │ │ │ andeq r0, r0, r0, asr #2 │ │ │ │ andeq r0, r0, r8, lsr #2 │ │ │ │ addlt fp, r4, r0, lsl r5 │ │ │ │ stmib sp, {r1, r2, sl, fp, ip, pc}^ │ │ │ │ stcls 4, cr4, [r7], {-0} │ │ │ │ @ instruction: 0xf7ef9402 │ │ │ │ - @ instruction: 0xb004fcb3 │ │ │ │ + @ instruction: 0xb004fcb7 │ │ │ │ svclt 0x0000bd10 │ │ │ │ @ instruction: 0x4604b530 │ │ │ │ strcc lr, [r5, #-2512] @ 0xfffff630 │ │ │ │ - blne 17139c4 │ │ │ │ + blne 17139bc │ │ │ │ sbcseq r6, fp, r5, lsl #18 │ │ │ │ svclt 0x00382b20 │ │ │ │ addsmi r2, sp, #32, 6 @ 0x80000000 │ │ │ │ strtmi sp, [r0], -r5, lsl #16 │ │ │ │ pop {r0, r1, ip, sp, pc} │ │ │ │ @ instruction: 0xf7f04030 │ │ │ │ stmib sp, {r0, r1, r3, r6, r8, fp, ip, sp, pc}^ │ │ │ │ @ instruction: 0xf7f01200 │ │ │ │ ldmib sp, {r0, r2, r3, r4, r7, fp, ip, sp, lr, pc}^ │ │ │ │ ldrb r1, [r2, r0, lsl #4]! │ │ │ │ strlt fp, [r0, #-1039] @ 0xfffffbf1 │ │ │ │ stmdbge r4, {r0, r1, r7, ip, sp, pc} │ │ │ │ - bleq 165930 │ │ │ │ + bleq 165928 │ │ │ │ @ instruction: 0xf0009101 │ │ │ │ andlt pc, r3, pc, lsr #16 │ │ │ │ - bl 16596c │ │ │ │ + bl 165964 │ │ │ │ ldrbmi fp, [r0, -r4]! │ │ │ │ stcmi 5, cr11, [r6], {16} │ │ │ │ ldrbtmi r4, [ip], #-2822 @ 0xfffff4fa │ │ │ │ stmdavs r2!, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldmdblt sl, {r3, r4, sp, lr} │ │ │ │ @ instruction: 0xf7e94610 │ │ │ │ - eorvs lr, r0, r8, asr #26 │ │ │ │ + eorvs lr, r0, ip, asr #26 │ │ │ │ svclt 0x0000bd10 │ │ │ │ - andeq r9, r2, r2, lsl #1 │ │ │ │ - andeq r8, r2, r8, asr #23 │ │ │ │ + andeq r9, r2, sl, lsl #1 │ │ │ │ + ldrdeq r8, [r2], -r0 │ │ │ │ @ instruction: 0x4615b5f8 │ │ │ │ strmi r4, [r7], -ip, lsl #12 │ │ │ │ @ instruction: 0xf7f04610 │ │ │ │ adcmi pc, r5, #602112 @ 0x93000 │ │ │ │ stmdale r6, {r1, r2, r9, sl, lr} │ │ │ │ ldrtmi r4, [r9], -r2, lsr #12 │ │ │ │ pop {r4, r5, r9, sl, lr} │ │ │ │ @ instruction: 0xf7e940f8 │ │ │ │ - blne ad6818 │ │ │ │ + blne ad6820 │ │ │ │ strtmi r2, [r0], #-256 @ 0xffffff00 │ │ │ │ - stcl 7, cr15, [r8], {233} @ 0xe9 │ │ │ │ + stcl 7, cr15, [ip], {233} @ 0xe9 │ │ │ │ svclt 0x0000e7f2 │ │ │ │ @ instruction: 0x460db538 │ │ │ │ @ instruction: 0xf7f04604 │ │ │ │ @ instruction: 0xf7f0faa9 │ │ │ │ @ instruction: 0x4621fa7b │ │ │ │ strmi r4, [r4], -sl, lsr #12 │ │ │ │ - ldcl 7, cr15, [r6], {233} @ 0xe9 │ │ │ │ + ldcl 7, cr15, [sl], {233} @ 0xe9 │ │ │ │ ldclt 6, cr4, [r8, #-128]! @ 0xffffff80 │ │ │ │ subseq r6, sl, r3, lsl #16 │ │ │ │ @ instruction: 0xf043bf4c │ │ │ │ @ instruction: 0xf0234300 │ │ │ │ ldrmi r4, [r8], #-768 @ 0xfffffd00 │ │ │ │ svclt 0x00004770 │ │ │ │ ldrbmi lr, [r0, sp, lsr #18]! │ │ │ │ @ instruction: 0xf101b339 │ │ │ │ @ instruction: 0x460538ff │ │ │ │ @ instruction: 0x46474616 │ │ │ │ stmibne r1!, {sl, sp}^ │ │ │ │ bicsvc lr, r1, r1, lsl #22 │ │ │ │ - b 13eb9c0 │ │ │ │ - bl 16a3a4 │ │ │ │ + b 13eb9b8 │ │ │ │ + bl 16a39c │ │ │ │ strbmi r0, [r8], -sl, lsl #18 │ │ │ │ @ instruction: 0xffe2f7ff │ │ │ │ andle r4, lr, r8, lsl #11 │ │ │ │ - beq 263cd8 │ │ │ │ - bl 178374 │ │ │ │ + beq 263cd0 │ │ │ │ + bl 17836c │ │ │ │ stmdale sl, {r1, r3} │ │ │ │ @ instruction: 0xffd8f7ff │ │ │ │ mcrrne 8, 0, r3, ip, cr1 │ │ │ │ mvnle r4, #176, 4 │ │ │ │ pop {r3, r6, r9, sl, lr} │ │ │ │ adcsmi r8, r0, #240, 14 @ 0x3c00000 │ │ │ │ addmi sp, ip, #4096000 @ 0x3e8000 │ │ │ │ @@ -22910,59 +22908,59 @@ │ │ │ │ @ instruction: 0x87f0e8bd │ │ │ │ stmdacs r1, {r3, r8, r9, fp, lr} │ │ │ │ andle r4, r8, fp, ror r4 │ │ │ │ andle r2, r3, r2, lsl #16 │ │ │ │ stmdami r6, {r6, r8, fp, ip, sp, pc} │ │ │ │ @ instruction: 0x47704478 │ │ │ │ ldmpl r8, {r0, r2, r9, fp, lr} │ │ │ │ - bmi 1796bc │ │ │ │ + bmi 1796b4 │ │ │ │ @ instruction: 0x47705898 │ │ │ │ ldrbmi r2, [r0, -r0]! │ │ │ │ - andeq r8, r2, ip, lsl r7 │ │ │ │ + andeq r8, r2, r4, lsr #14 │ │ │ │ andeq r0, r0, r1, asr #14 │ │ │ │ andeq r0, r0, r8, lsr r1 │ │ │ │ andeq r0, r0, ip, asr r1 │ │ │ │ - blmi 97a1a8 │ │ │ │ + blmi 97a1a0 │ │ │ │ ldrlt r4, [r0, #-1146]! @ 0xfffffb86 │ │ │ │ addlt r4, r3, r4, lsl #12 │ │ │ │ ldmpl r3, {r0, r2, r3, r7, r9, sl, fp, ip}^ │ │ │ │ stmdbge r1, {r0, r1, r4, r6, r8, r9, ip, sp, pc} │ │ │ │ @ instruction: 0xf7e94628 │ │ │ │ - movwlt lr, #3036 @ 0xbdc │ │ │ │ + movwlt lr, #3040 @ 0xbe0 │ │ │ │ strtmi r9, [sl], -r1, lsl #18 │ │ │ │ @ instruction: 0xffa4f7ff │ │ │ │ bicslt r4, r0, r1, lsl #12 │ │ │ │ @ instruction: 0xff96f7ff │ │ │ │ stmdavs fp, {r5, r7, sl, sp, lr}^ │ │ │ │ eorle r2, ip, r1, lsl #22 │ │ │ │ @ instruction: 0xf1012b00 │ │ │ │ svclt 0x00b80004 │ │ │ │ - blle b0558 │ │ │ │ + blle b0550 │ │ │ │ @ instruction: 0xff8af7ff │ │ │ │ stmib r4, {r8, r9, sp}^ │ │ │ │ stmdavs r3, {r0, r1, r4, r8, r9} │ │ │ │ - blle 4f2564 │ │ │ │ + blle 4f255c │ │ │ │ @ instruction: 0xff82f7ff │ │ │ │ andcs r4, r0, r3, lsl #12 │ │ │ │ andlt r6, r3, r3, lsr #2 │ │ │ │ movwcs fp, #3376 @ 0xd30 │ │ │ │ @ instruction: 0x61232009 │ │ │ │ ldclt 0, cr11, [r0, #-12]! │ │ │ │ - blmi 379db0 │ │ │ │ + blmi 379da8 │ │ │ │ ldmpl r0, {r0, r4, r6, fp, ip, lr}^ │ │ │ │ sbcne r1, r9, r9, lsl #20 │ │ │ │ ldrb r9, [r2, r1, lsl #2] │ │ │ │ andvs pc, r3, r3, asr #7 │ │ │ │ @ instruction: 0xffa6f7ff │ │ │ │ @ instruction: 0x61231e03 │ │ │ │ andcs fp, r9, ip, lsl #30 │ │ │ │ andlt r2, r3, r0 │ │ │ │ movwcs fp, #3376 @ 0xd30 │ │ │ │ strb r2, [r1, r5]! │ │ │ │ - andeq r8, r2, r8, ror #13 │ │ │ │ + strdeq r8, [r2], -r0 │ │ │ │ andeq r0, r0, ip, lsr #2 │ │ │ │ andeq r0, r0, r0, lsr r1 │ │ │ │ andeq r0, r0, ip, asr #2 │ │ │ │ ldrlt r6, [r0, #-2051] @ 0xfffff7fd │ │ │ │ ldrbeq r4, [sl, r4, lsl #12] │ │ │ │ subscc sp, r0, r5, lsl #8 │ │ │ │ strle r0, [r9, #-1947] @ 0xfffff865 │ │ │ │ @@ -22998,54 +22996,54 @@ │ │ │ │ ldrmi r2, [r8, r1] │ │ │ │ rscsle r2, r0, r8, lsl #16 │ │ │ │ tstle r6, r7, lsl #16 │ │ │ │ ldcvs 6, cr4, [r1], #-160 @ 0xffffff60 │ │ │ │ @ instruction: 0xffe6f7ff │ │ │ │ @ instruction: 0xf0001d30 │ │ │ │ @ instruction: 0xf7e9fc7b │ │ │ │ - svclt 0x0000ec38 │ │ │ │ + svclt 0x0000ec3c │ │ │ │ svcmi 0x00f0e92d │ │ │ │ @ instruction: 0xf8d01d0f │ │ │ │ @ instruction: 0xf8d0900c │ │ │ │ @ instruction: 0x4606a018 │ │ │ │ @ instruction: 0xf5ad4614 │ │ │ │ svcgt 0x000f7d77 │ │ │ │ - bleq 363eac │ │ │ │ + bleq 363ea4 │ │ │ │ stcge 6, cr4, [r2, #-880] @ 0xfffffc90 │ │ │ │ cdpeq 0, 0, cr15, cr0, cr15, {2} │ │ │ │ ldmvc r8!, {r0, r2, r3, r8, sl, ip, sp, lr, pc}^ │ │ │ │ andeq lr, pc, ip, lsr #17 │ │ │ │ stmia ip!, {r0, r1, r2, r3, r8, r9, sl, fp, lr, pc} │ │ │ │ svcgt 0x000f000f │ │ │ │ andeq lr, pc, ip, lsr #17 │ │ │ │ muleq pc, r7, r8 @ │ │ │ │ andeq lr, pc, ip, lsl #17 │ │ │ │ and pc, r0, r5, asr #17 │ │ │ │ stcvs 0, cr14, [fp], #-132 @ 0xffffff7c │ │ │ │ cmnvs r3, r9, lsr #12 │ │ │ │ rscsvc pc, r4, #1325400064 @ 0x4f000000 │ │ │ │ @ instruction: 0xf7e94640 │ │ │ │ - ldmdbvs r3!, {r6, r7, r9, fp, sp, lr, pc} │ │ │ │ + ldmdbvs r3!, {r2, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ ldrtmi r4, [r1], -r2, asr #12 │ │ │ │ ldrmi r4, [r8, r0, lsr #12] │ │ │ │ @ instruction: 0xf8d84607 │ │ │ │ @ instruction: 0x46210038 │ │ │ │ ldrtmi r6, [r3], -r8, lsr #9 │ │ │ │ stmib sp, {r1, r4, r5, r9, sl, lr}^ │ │ │ │ andcs r5, r1, r0, lsl #20 │ │ │ │ strmi r4, [r4], -r8, asr #15 │ │ │ │ strbmi fp, [r1], -r8, lsl #22 │ │ │ │ vst1.8 {d20-d22}, [pc :128], r8 │ │ │ │ @ instruction: 0xf7e972f4 │ │ │ │ - svccs 0x0008eaa8 │ │ │ │ + svccs 0x0008eaac │ │ │ │ stcvs 1, cr13, [r9], #-92 @ 0xffffffa4 │ │ │ │ @ instruction: 0xf7ff4630 │ │ │ │ strcc pc, [r9], #-3859 @ 0xfffff0ed │ │ │ │ stmdacs r0, {r0, r1, r2, r9, sl, lr} │ │ │ │ - blvs fea5be4c │ │ │ │ + blvs fea5be44 │ │ │ │ strtvs r4, [r8], #1587 @ 0x633 │ │ │ │ @ instruction: 0xf0444632 │ │ │ │ stmib sp, {r4, r8}^ │ │ │ │ andcs r5, r1, r0, lsl #20 │ │ │ │ ldmdblt r0!, {r3, r6, r7, r8, r9, sl, lr} │ │ │ │ @ instruction: 0xf50d4638 │ │ │ │ pop {r0, r1, r2, r4, r5, r6, r8, sl, fp, ip, sp, lr} │ │ │ │ @@ -23055,22 +23053,22 @@ │ │ │ │ pop {r0, r1, r2, r4, r5, r6, r8, sl, fp, ip, sp, lr} │ │ │ │ qsub8mi r8, r0, r0 │ │ │ │ @ instruction: 0xf7ff6c29 │ │ │ │ usub16mi pc, r8, r7 @ │ │ │ │ stc2 0, cr15, [ip], {-0} │ │ │ │ ldrbmi r6, [r0, -r0, lsl #25]! │ │ │ │ @ instruction: 0xf101b5f0 │ │ │ │ - blvs ff2eab50 │ │ │ │ + blvs ff2eab48 │ │ │ │ strvs fp, [fp], #-251 @ 0xffffff05 │ │ │ │ strmi r4, [r5], -pc, lsl #12 │ │ │ │ @ instruction: 0x000fe8bc │ │ │ │ @ instruction: 0xf04fac01 │ │ │ │ @ instruction: 0x466e3eff │ │ │ │ ldm ip!, {r0, r1, r2, r3, sl, lr, pc} │ │ │ │ - strgt r0, [pc], #-15 @ 27b5c <__time64@plt+0x16874> │ │ │ │ + strgt r0, [pc], #-15 @ 27b54 <__time64@plt+0x1686c> │ │ │ │ @ instruction: 0x000fe8bc │ │ │ │ ldm ip, {r0, r1, r2, r3, sl, lr, pc} │ │ │ │ stm r4, {r0, r1, r2, r3} │ │ │ │ @ instruction: 0xf8cd000f │ │ │ │ and lr, r6, r0 │ │ │ │ ldrtmi r6, [r2], -fp, lsr #18 │ │ │ │ ldrmi r4, [r8, r9, lsr #12] │ │ │ │ @@ -23101,16 +23099,16 @@ │ │ │ │ strtmi r4, [r0], -r9, lsr #12 │ │ │ │ @ instruction: 0xff20f7ff │ │ │ │ stcvs 6, cr4, [r9], #-192 @ 0xffffff40 │ │ │ │ @ instruction: 0xff1af7ff │ │ │ │ @ instruction: 0xf0001d28 │ │ │ │ andcs pc, r1, #179200 @ 0x2bc00 │ │ │ │ @ instruction: 0xff34f7ff │ │ │ │ - bl 1a65b9c │ │ │ │ - bl 19e5ba0 │ │ │ │ + bl 1b65b94 │ │ │ │ + bl 1ae5b98 │ │ │ │ strlt r6, [r8, #-2242] @ 0xfffff73e │ │ │ │ @ instruction: 0xf8d1b13a │ │ │ │ andcs ip, r0, #60 @ 0x3c │ │ │ │ @ instruction: 0x4008e8bd │ │ │ │ subgt pc, r0, r1, asr #17 │ │ │ │ @ instruction: 0xf7ffe724 │ │ │ │ mulcs r9, r1, pc @ │ │ │ │ @@ -23119,15 +23117,15 @@ │ │ │ │ strmi r6, [r1], -r3, lsl #17 │ │ │ │ andcs fp, r1, fp, lsl #2 │ │ │ │ @ instruction: 0x47704718 │ │ │ │ ldmdale r6, {r0, r2, r8, fp, sp} │ │ │ │ @ instruction: 0xf001e8df │ │ │ │ tsteq r5, #671088640 @ 0x28000000 │ │ │ │ andcs r0, r1, r3, lsl #10 │ │ │ │ - bls 39a00 <__time64@plt+0x28718> │ │ │ │ + bls 399f8 <__time64@plt+0x28710> │ │ │ │ andcs r6, r0, r3, asr #24 │ │ │ │ @ instruction: 0x47706013 │ │ │ │ svclt 0x00982a0f │ │ │ │ tstle r6, r0, lsl #22 │ │ │ │ addeq lr, r2, #0, 22 │ │ │ │ ldmdavs r3, {sp}^ │ │ │ │ andsvs r9, r3, r0, lsl #20 │ │ │ │ @@ -23139,20 +23137,20 @@ │ │ │ │ @ instruction: 0xf7ff9400 │ │ │ │ stmdals r3, {r0, r1, r3, r4, r6, r7, r8, r9, sl, fp, ip, sp, lr, pc} │ │ │ │ ldclt 0, cr11, [r0, #-16] │ │ │ │ ldmdale r6, {r0, r2, r8, fp, sp} │ │ │ │ @ instruction: 0xf001e8df │ │ │ │ tsteq r5, #671088640 @ 0x28000000 │ │ │ │ andcs r0, r1, r3, lsl #10 │ │ │ │ - blls 39a50 <__time64@plt+0x28768> │ │ │ │ + blls 39a48 <__time64@plt+0x28760> │ │ │ │ strbvs r6, [r3], #-2075 @ 0xfffff7e5 │ │ │ │ ldrbmi r2, [r0, -r0]! │ │ │ │ svclt 0x00982a0f │ │ │ │ tstle r6, r0, lsl #22 │ │ │ │ - bl 4e8a4 <__time64@plt+0x3d5bc> │ │ │ │ + bl 4e89c <__time64@plt+0x3d5b4> │ │ │ │ andcs r0, r0, r2, lsl #5 │ │ │ │ subsvs r6, r3, fp, lsl r8 │ │ │ │ andcs r4, r2, r0, ror r7 │ │ │ │ svclt 0x00004770 │ │ │ │ movwcs fp, #1296 @ 0x510 │ │ │ │ stcge 0, cr11, [r3], {132} @ 0x84 │ │ │ │ strmi r9, [sl], -r3, lsl #4 │ │ │ │ @@ -23194,25 +23192,25 @@ │ │ │ │ pop {r4, r8, sl, fp, ip, sp, lr} │ │ │ │ svclt 0x000081f0 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stclvs 6, cr4, [pc], {12} │ │ │ │ @ instruction: 0xf8dfb08b │ │ │ │ ldrmi sl, [r5], -ip, asr #5 │ │ │ │ stceq 0, cr15, [r3], {-0} │ │ │ │ - blne 165ec8 │ │ │ │ + blne 165ec0 │ │ │ │ @ instruction: 0x469844fa │ │ │ │ mvnlt r9, r8, lsl #14 │ │ │ │ @ instruction: 0xf88d0c0e │ │ │ │ streq r6, [r9], #-37 @ 0xffffffdb │ │ │ │ rscslt r9, r6, #-1073741823 @ 0xc0000001 │ │ │ │ - bl 1f018c │ │ │ │ + bl 1f0184 │ │ │ │ @ instruction: 0xf1bc0786 │ │ │ │ @ instruction: 0xf88d0f02 │ │ │ │ stcvs 0, cr1, [r1, #-144]! @ 0xffffff70 │ │ │ │ - blvs fea179b4 │ │ │ │ + blvs fea179ac │ │ │ │ tstpeq r1, r1, lsl r0 @ p-variant is OBSOLETE │ │ │ │ stmdbge r7, {r0, r1, r2, r3, ip, lr, pc} │ │ │ │ @ instruction: 0xf0004628 │ │ │ │ stmdacs r0, {r0, r1, r3, r6, r7, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ andcs sp, r8, fp, ror #2 │ │ │ │ pop {r0, r1, r3, ip, sp, pc} │ │ │ │ andeq r8, r9, #240, 30 @ 0x3c0 │ │ │ │ @@ -23230,47 +23228,47 @@ │ │ │ │ @ instruction: 0xf8d7bf07 │ │ │ │ strcc r9, [r8, -r4] │ │ │ │ @ instruction: 0x9002f8b7 │ │ │ │ @ instruction: 0xb000f8b7 │ │ │ │ smladcc r4, r8, pc, fp @ │ │ │ │ andeq pc, r1, #41 @ 0x29 │ │ │ │ stmdbeq r9, {r0, r1, r2, r3, r6, r9, fp, sp, lr, pc}^ │ │ │ │ - beq 122a04 │ │ │ │ + beq 1229fc │ │ │ │ stmdbeq r2, {r0, r3, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xff30f7ff │ │ │ │ movweq pc, #4107 @ 0x100b @ │ │ │ │ - b 1279414 │ │ │ │ + b 127940c │ │ │ │ ldmdale r0!, {r0, r1, r8, r9} │ │ │ │ - bleq a3ec0 │ │ │ │ + bleq a3eb8 │ │ │ │ ldrbmi r2, [r3], #2817 @ 0xb01 │ │ │ │ - blcs dbfcc │ │ │ │ - bllt 1d1beec │ │ │ │ + blcs dbfc4 │ │ │ │ + bllt 1d1bee4 │ │ │ │ svclt 0x00182e00 │ │ │ │ vrshl.s8 d4, d3, d16 │ │ │ │ @ instruction: 0x370480d5 │ │ │ │ ldrdlt pc, [r0], -r7 │ │ │ │ svceq 0x0000f1bb │ │ │ │ stmdbge r7, {r2, r3, r6, r7, r8, ip, lr, pc} │ │ │ │ @ instruction: 0xf8dd4628 │ │ │ │ @ instruction: 0xf000a00c │ │ │ │ stmiblt r0!, {r0, r1, r3, r4, r5, r6, r8, r9, fp, ip, sp, lr, pc}^ │ │ │ │ - blcs 4ea50 <__time64@plt+0x3d768> │ │ │ │ + blcs 4ea48 <__time64@plt+0x3d760> │ │ │ │ smlatbcs pc, sp, r0, sp @ │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ tstpcs lr, r9, lsl #30 @ p-variant is OBSOLETE │ │ │ │ strtmi r4, [r8], -r2, lsl #12 │ │ │ │ @ instruction: 0xff2cf7ff │ │ │ │ @ instruction: 0x46284b74 │ │ │ │ @ instruction: 0xf85a210f │ │ │ │ movwls r3, #4099 @ 0x1003 │ │ │ │ @ instruction: 0xf7ff461a │ │ │ │ andcs pc, r7, r3, lsr #30 │ │ │ │ - blcs a1cdc │ │ │ │ - blcs dbfd4 │ │ │ │ - blcs 5bee8 │ │ │ │ + blcs a1cd4 │ │ │ │ + blcs dbfcc │ │ │ │ + blcs 5bee0 │ │ │ │ ldrdcs sp, [r9], -r5 │ │ │ │ pop {r0, r1, r3, ip, sp, pc} │ │ │ │ @ instruction: 0xf8d78ff0 │ │ │ │ @ instruction: 0xf0299000 │ │ │ │ ldmiblt r6!, {r9, fp, lr} │ │ │ │ stmdble r5, {r0, r1, r7, r8, sl, lr} │ │ │ │ @ instruction: 0xf1ba9b01 │ │ │ │ @@ -23283,15 +23281,15 @@ │ │ │ │ @ instruction: 0xf8d7e7bc │ │ │ │ @ instruction: 0xf0299000 │ │ │ │ vmlacs.f32 s8, s0, s0 │ │ │ │ @ instruction: 0xf8d4d0f0 │ │ │ │ strtmi fp, [r8], -r0, lsr #32 │ │ │ │ @ instruction: 0xf7ff210d │ │ │ │ strmi pc, [r3, #3789] @ 0xecd │ │ │ │ - bvs fe8dc670 │ │ │ │ + bvs fe8dc668 │ │ │ │ @ instruction: 0xd1e54297 │ │ │ │ @ instruction: 0xf04f1d3a │ │ │ │ cmnvs r2, #0, 18 │ │ │ │ stmib r4, {r2, r9, sp}^ │ │ │ │ @ instruction: 0xf8c4920b │ │ │ │ ldmdavs sl!, {r3, r5, sp, pc} │ │ │ │ vmls.f d20, d0, d2[2] │ │ │ │ @@ -23303,42 +23301,42 @@ │ │ │ │ umlalsle r1, ip, r9, ip │ │ │ │ cmppeq r8, r4, lsl #2 @ p-variant is OBSOLETE │ │ │ │ tstls r6, r1, lsl #6 │ │ │ │ ldcne 0, cr13, [r8, #-468]! @ 0xfffffe2c │ │ │ │ ldc2l 7, cr15, [lr, #-1020]! @ 0xfffffc04 │ │ │ │ strmi sl, [r1], -r6, lsl #22 │ │ │ │ @ instruction: 0xf7e94620 │ │ │ │ - stmdacs r0, {r2, r4, r5, r8, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r3, r4, r5, r8, fp, sp, lr, pc} │ │ │ │ strcc sp, [r8, -r2, asr #2] │ │ │ │ cdpcs 7, 0, cr14, cr0, cr2, {4} │ │ │ │ @ instruction: 0xf8d4d0fb │ │ │ │ strtmi r9, [r8], -r0, lsr #32 │ │ │ │ @ instruction: 0xf7ff210d │ │ │ │ strmi pc, [r1, #3735] @ 0xe97 │ │ │ │ - bvs fe91c708 │ │ │ │ + bvs fe91c700 │ │ │ │ @ instruction: 0xd1f0429f │ │ │ │ tstcs pc, r8, lsr r6 @ │ │ │ │ ldc2 7, cr15, [r2], {255} @ 0xff │ │ │ │ strtmi r4, [r8], -r2, lsl #12 │ │ │ │ mrc2 7, 5, pc, cr2, cr15, {7} │ │ │ │ strtmi r4, [r8], -r2, lsr #12 │ │ │ │ @ instruction: 0xf7ff2100 │ │ │ │ str pc, [r8, sp, lsr #29] │ │ │ │ cmppeq r8, #4, 2 @ p-variant is OBSOLETE │ │ │ │ stmib sp, {r1, r2, r9, fp, sp, pc}^ │ │ │ │ ldrtmi r6, [r1], r4, lsl #16 │ │ │ │ - bleq 164388 │ │ │ │ + bleq 164380 │ │ │ │ @ instruction: 0x4690461e │ │ │ │ ldrbmi lr, [r8], -ip │ │ │ │ andcs r9, r0, #6291456 @ 0x600000 │ │ │ │ stc2l 7, cr15, [sl, #-1020] @ 0xfffffc04 │ │ │ │ strmi r4, [r1], -r3, asr #12 │ │ │ │ @ instruction: 0xf10b4620 │ │ │ │ @ instruction: 0xf7e90b04 │ │ │ │ - ldmiblt r0!, {r1, r2, r3, r4, r5, r6, r7, fp, sp, lr, pc}^ │ │ │ │ + ldmiblt r0!, {r1, r8, fp, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf10945d1 │ │ │ │ mvnle r0, r1, lsl #18 │ │ │ │ tstcs sp, r8, lsr #12 │ │ │ │ mcr2 7, 3, pc, cr4, cr15, {7} @ │ │ │ │ stmib r4, {r1, r2, r8, r9, fp, ip, pc}^ │ │ │ │ andcs r0, r6, r8, lsl #6 │ │ │ │ ldrbt r6, [pc], r7, lsr #5 │ │ │ │ @@ -23353,15 +23351,15 @@ │ │ │ │ ldmib sp, {r1, r2, r3, r5, r6, r7, r9, sl, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf8d76804 │ │ │ │ strb r9, [r5, -r0]! │ │ │ │ smladxcc r4, r8, r6, r4 │ │ │ │ mcrr2 7, 15, pc, r8, cr15 @ │ │ │ │ strmi r6, [r3], -r7, lsr #7 │ │ │ │ ldrmi r4, [ip], -r0, lsr #12 │ │ │ │ - ldm r2, {r0, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldm r6, {r0, r3, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ strtmi sl, [r2], -r8, asr #30 │ │ │ │ tstcs pc, r8, lsr #12 │ │ │ │ mrc2 7, 2, pc, cr14, cr15, {7} │ │ │ │ @ instruction: 0x4689e739 │ │ │ │ tstcs sp, r8, lsr #12 │ │ │ │ @ instruction: 0xf7ff464d │ │ │ │ @@ -23371,15 +23369,15 @@ │ │ │ │ addeq lr, r2, r7, lsl #22 │ │ │ │ stc2 7, cr15, [sl], #-1020 @ 0xfffffc04 │ │ │ │ strtmi r4, [r8], -r2, lsl #12 │ │ │ │ mcr2 7, 2, pc, cr10, cr15, {7} @ │ │ │ │ strbmi r4, [r9], -r2, lsr #12 │ │ │ │ @ instruction: 0xf7ff4628 │ │ │ │ str pc, [r0, -r5, asr #28]! │ │ │ │ - muleq r2, r4, r2 │ │ │ │ + muleq r2, ip, r2 │ │ │ │ andeq r0, r0, r8, asr r1 │ │ │ │ str r2, [sp], r0, lsl #6 │ │ │ │ str r2, [fp], r1, lsl #6 │ │ │ │ str r2, [r9], r2, lsl #6 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ ldrmi r4, [r4], -r5, lsl #12 │ │ │ │ stmdbcs r5, {r2, r6, r7, ip, sp, pc} │ │ │ │ @@ -23389,120 +23387,120 @@ │ │ │ │ sublt r2, r4, r2 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ @ instruction: 0x2c006b83 │ │ │ │ @ instruction: 0xf853d1f8 │ │ │ │ strbvs r2, [r2], #-2820 @ 0xfffff4fc │ │ │ │ andcs r6, r0, r3, lsl #7 │ │ │ │ pop {r2, r6, ip, sp, pc} │ │ │ │ - blcs 48838 <__time64@plt+0x37550> │ │ │ │ - blvs fe05c834 │ │ │ │ + blcs 48830 <__time64@plt+0x37548> │ │ │ │ + blvs fe05c82c │ │ │ │ stc2 10, cr15, [r4], {31} @ │ │ │ │ strcs r1, [r1], -pc, lsr #26 │ │ │ │ @ instruction: 0xf103fa06 │ │ │ │ - b 479894 │ │ │ │ + b 47988c │ │ │ │ svclt 0x001c0f0c │ │ │ │ - blne 1661dc │ │ │ │ + blne 1661d4 │ │ │ │ eorne pc, r3, r7, asr #16 │ │ │ │ movweq pc, #4355 @ 0x1103 @ │ │ │ │ sadd16mi fp, r0, r8 │ │ │ │ mvnle r2, r0, lsl fp │ │ │ │ svclt 0x005804a2 │ │ │ │ strb r6, [r0, r8, lsr #7]! │ │ │ │ andeq pc, r4, #35 @ 0x23 │ │ │ │ - bcs 6b14c │ │ │ │ + bcs 6b144 │ │ │ │ bicle fp, pc, r4, lsr #5 │ │ │ │ stmdaeq r4, {r1, r2, r8, r9, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf0002b01 │ │ │ │ @ instruction: 0xf1b880c6 │ │ │ │ stmiale r7, {r5, r8, r9, sl, fp}^ │ │ │ │ vceq.f32 d18, d0, d15 │ │ │ │ strtmi r8, [r0], r3, lsl #1 │ │ │ │ sbcle r2, ip, r0, lsl #24 │ │ │ │ movwls r6, #6146 @ 0x1802 │ │ │ │ @ instruction: 0xf1000753 │ │ │ │ stcge 1, cr8, [r2], {10} │ │ │ │ @ instruction: 0xf0004620 │ │ │ │ @ instruction: 0xf8d5f953 │ │ │ │ - blls 981cc │ │ │ │ + blls 981c4 │ │ │ │ rscscc pc, pc, #79 @ 0x4f │ │ │ │ @ instruction: 0xf04f2e10 │ │ │ │ ldrtmi r0, [r1], -r2, lsl #28 │ │ │ │ tstcs r0, r8, lsr pc │ │ │ │ - blx 639a82 │ │ │ │ - bl 13393c │ │ │ │ + blx 639a7a │ │ │ │ + bl 133934 │ │ │ │ stmibcc r4, {r0, r6, r7, r8} │ │ │ │ @ instruction: 0xf8504672 │ │ │ │ - bcc 86d20 │ │ │ │ + bcc 86d18 │ │ │ │ svcvc 0x0004f841 │ │ │ │ mvnsle r1, r7, asr ip │ │ │ │ stceq 1, cr15, [r4], {12} │ │ │ │ - bl 332d24 │ │ │ │ + bl 332d1c │ │ │ │ svclt 0x0004028e │ │ │ │ ldrmi sl, [r4], r2, lsr #30 │ │ │ │ adchi pc, pc, r0 │ │ │ │ @ instruction: 0x63aa2e0f │ │ │ │ sbchi pc, r2, r0, asr #4 │ │ │ │ @ instruction: 0xf0004620 │ │ │ │ ldr pc, [r8, r5, lsr #18] │ │ │ │ orrle r2, fp, r3, lsl #22 │ │ │ │ - blx 7eb1dc │ │ │ │ - bl 1e6358 │ │ │ │ - blcs 428d6c │ │ │ │ + blx 7eb1d4 │ │ │ │ + bl 1e6350 │ │ │ │ + blcs 428d64 │ │ │ │ stmdavs r3, {r2, r7, fp, ip, lr, pc} │ │ │ │ @ instruction: 0xf1000718 │ │ │ │ svcge 0x002280a9 │ │ │ │ @ instruction: 0xf0004638 │ │ │ │ - b 1426654 │ │ │ │ - blvs feb28684 │ │ │ │ + b 142664c │ │ │ │ + blvs feb2867c │ │ │ │ biceq lr, r6, #7168 @ 0x1c00 │ │ │ │ cmplt r1, sl, asr #28 │ │ │ │ ldmdapl r9, {r5, r6, r7, r9, fp, ip} │ │ │ │ @ instruction: 0xf8433a01 │ │ │ │ mrrcne 11, 0, r1, r1, cr4 @ │ │ │ │ - bl 15c960 │ │ │ │ + bl 15c958 │ │ │ │ ldrtmi r0, [r8], -r8, asr #9 │ │ │ │ @ instruction: 0xf00063ac │ │ │ │ ldrb pc, [r2, -r7, lsl #18]! @ │ │ │ │ svclt 0x00982c10 │ │ │ │ @ instruction: 0xf47f2b00 │ │ │ │ stmdavs r3, {r0, r1, r5, r6, r8, r9, sl, fp, sp, pc} │ │ │ │ - ldrbtle r0, [pc], #-1758 @ 28198 <__time64@plt+0x16eb0> │ │ │ │ + ldrbtle r0, [pc], #-1758 @ 28190 <__time64@plt+0x16ea8> │ │ │ │ ldrtmi sl, [r8], -r2, lsr #30 │ │ │ │ @ instruction: 0xf948f000 │ │ │ │ ldrtmi r6, [r9], -lr, lsr #23 │ │ │ │ @ instruction: 0xf04f2300 │ │ │ │ - blx 32b1b0 │ │ │ │ + blx 32b1a8 │ │ │ │ ldrtmi pc, [r0], -r3, lsl #4 @ │ │ │ │ @ instruction: 0xf1034222 │ │ │ │ setend be │ │ │ │ svclt 0x001e0104 │ │ │ │ - blcs 166300 │ │ │ │ + blcs 1662f8 │ │ │ │ stccs 8, cr15, [r4], {65} @ 0x41 │ │ │ │ - blcs 1399e0 │ │ │ │ + blcs 1399d8 │ │ │ │ ldrtmi sp, [r8], -pc, ror #3 │ │ │ │ @ instruction: 0xf00063ae │ │ │ │ strb pc, [ip, -r5, lsr #18] @ │ │ │ │ @ instruction: 0xf1b86802 │ │ │ │ vrecps.f32 d16, d0, d0 │ │ │ │ @ instruction: 0xf1a88091 │ │ │ │ bfieq r0, r0, #16, #5 │ │ │ │ ldrbeq sp, [r7, -ip, ror #8] │ │ │ │ svcge 0x0022d479 │ │ │ │ ldrtmi r9, [r8], -r1, lsl #6 │ │ │ │ ldreq pc, [r0], #-454 @ 0xfffffe3a │ │ │ │ @ instruction: 0xf8c2f000 │ │ │ │ @ instruction: 0xf000a802 │ │ │ │ @ instruction: 0xf8d5f8c7 │ │ │ │ - blls 982e4 │ │ │ │ + blls 982dc │ │ │ │ @ instruction: 0xf04f2102 │ │ │ │ @ instruction: 0x466032ff │ │ │ │ vmovcs.32 d1[0], pc │ │ │ │ biceq lr, r6, r7, lsl #22 │ │ │ │ ldrbtmi r3, [r2], -r4, lsl #18 │ │ │ │ - blmi 16635c │ │ │ │ + blmi 166354 │ │ │ │ @ instruction: 0xf8413a01 │ │ │ │ mrrcne 15, 0, r4, r4, cr4 @ │ │ │ │ @ instruction: 0xf10cd1f8 │ │ │ │ stcge 12, cr0, [r2], {4} │ │ │ │ vstmiaeq lr, {d14-d19} │ │ │ │ svceq 0x0000f1b8 │ │ │ │ svcge 0x005af47f │ │ │ │ @@ -23539,63 +23537,63 @@ │ │ │ │ @ instruction: 0xf000602b │ │ │ │ @ instruction: 0xe74ef891 │ │ │ │ @ instruction: 0xf000a822 │ │ │ │ @ instruction: 0xe739f85b │ │ │ │ @ instruction: 0xf0224628 │ │ │ │ @ instruction: 0xf0420201 │ │ │ │ movwls r0, #4610 @ 0x1202 │ │ │ │ - blcs 14663d0 │ │ │ │ + blcs 14663c8 │ │ │ │ @ instruction: 0xf854f000 │ │ │ │ - blls 82380 │ │ │ │ + blls 82378 │ │ │ │ svceq 0x0004f012 │ │ │ │ strtmi sp, [r8], -r5, lsl #1 │ │ │ │ andeq pc, r4, #34 @ 0x22 │ │ │ │ @ instruction: 0xf8409301 │ │ │ │ @ instruction: 0xf0002bd8 │ │ │ │ - blls a642c │ │ │ │ + blls a6424 │ │ │ │ @ instruction: 0xf022e77b │ │ │ │ @ instruction: 0xf8400204 │ │ │ │ @ instruction: 0xf0002bd8 │ │ │ │ strbt pc, [lr], r7, asr #16 @ │ │ │ │ strle r0, [ip], #-2000 @ 0xfffff830 │ │ │ │ movwls sl, #7970 @ 0x1f22 │ │ │ │ @ instruction: 0xf0004638 │ │ │ │ stccs 8, cr15, [r0], {55} @ 0x37 │ │ │ │ @ instruction: 0xf8d5d099 │ │ │ │ @ instruction: 0xf04fc038 │ │ │ │ - blls 6a31c │ │ │ │ - blcs 1a20e8 │ │ │ │ + blls 6a314 │ │ │ │ + blcs 1a20e0 │ │ │ │ tstle sl, r1, lsl #6 │ │ │ │ @ instruction: 0xf0224628 │ │ │ │ @ instruction: 0xf0420201 │ │ │ │ @ instruction: 0xf8400202 │ │ │ │ @ instruction: 0xf0002b50 │ │ │ │ - blls a63c4 │ │ │ │ + blls a63bc │ │ │ │ strtmi lr, [r8], -r4, ror #15 │ │ │ │ andeq pc, r3, #34 @ 0x22 │ │ │ │ - blcs 1466444 │ │ │ │ + blcs 146643c │ │ │ │ @ instruction: 0xf812f000 │ │ │ │ ldrb r9, [fp, r1, lsl #22] │ │ │ │ teqpeq r4, r0, lsl #2 @ p-variant is OBSOLETE │ │ │ │ mlaseq r8, r1, r8, lr │ │ │ │ ssatmi r4, #7, ip, lsl #13 │ │ │ │ stcpl 8, cr15, [r4, #-304] @ 0xfffffed0 │ │ │ │ svceq 0x00ffe890 │ │ │ │ stclt 6, cr4, [r0, #-916] @ 0xfffffc6c │ │ │ │ - bleq 8a35a8 │ │ │ │ + bleq 8a35a0 │ │ │ │ svclt 0x00004770 │ │ │ │ - bleq 8a3570 │ │ │ │ + bleq 8a3568 │ │ │ │ svclt 0x00004770 │ │ │ │ - bleq 8635b8 │ │ │ │ + bleq 8635b0 │ │ │ │ svclt 0x00004770 │ │ │ │ - bleq 863580 │ │ │ │ + bleq 863578 │ │ │ │ svclt 0x00004770 │ │ │ │ - bleq 8636c8 │ │ │ │ + bleq 8636c0 │ │ │ │ svclt 0x00004770 │ │ │ │ - bleq 863690 │ │ │ │ + bleq 863688 │ │ │ │ svclt 0x00004770 │ │ │ │ strdeq lr, [r2, -r0] │ │ │ │ strdne lr, [r2, -r0] │ │ │ │ strdcs lr, [r2, -r0] │ │ │ │ strdcc lr, [r2, -r0] │ │ │ │ strdmi lr, [r2, -r0] │ │ │ │ strdpl lr, [r2, -r0] │ │ │ │ @@ -23638,51 +23636,51 @@ │ │ │ │ smlatblt r1, r0, ip, pc @ │ │ │ │ svclt 0x00004770 │ │ │ │ strlt r4, [r0, #-1772] @ 0xfffff914 │ │ │ │ andpl lr, r0, sp, lsr #18 │ │ │ │ svcne 0x00ffe92d │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ stmdbge r1, {r2, r3, sl, ip, sp, pc} │ │ │ │ - blx 1be645a │ │ │ │ + blx 1be6452 │ │ │ │ ldrd pc, [r0], #-141 @ 0xffffff73 │ │ │ │ @ instruction: 0x4770b012 │ │ │ │ strlt r4, [r0, #-1772] @ 0xfffff914 │ │ │ │ andpl lr, r0, sp, lsr #18 │ │ │ │ svcne 0x00ffe92d │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ stmdbge r1, {r2, r3, sl, ip, sp, pc} │ │ │ │ - blx fe7e647a │ │ │ │ + blx fe7e6472 │ │ │ │ ldrd pc, [r0], #-141 @ 0xffffff73 │ │ │ │ @ instruction: 0x4770b012 │ │ │ │ strlt r4, [r0, #-1772] @ 0xfffff914 │ │ │ │ andpl lr, r0, sp, lsr #18 │ │ │ │ svcne 0x00ffe92d │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ stmdbge r1, {r2, r3, sl, ip, sp, pc} │ │ │ │ - blx fec6649a │ │ │ │ + blx fec66492 │ │ │ │ ldrd pc, [r0], #-141 @ 0xffffff73 │ │ │ │ @ instruction: 0x4770b012 │ │ │ │ strlt r4, [r0, #-1772] @ 0xfffff914 │ │ │ │ andpl lr, r0, sp, lsr #18 │ │ │ │ svcne 0x00ffe92d │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - blge 954e8 │ │ │ │ - blx 1d664ba │ │ │ │ + blge 954e0 │ │ │ │ + blx 1d664b2 │ │ │ │ ldrd pc, [r0], #-141 @ 0xffffff73 │ │ │ │ @ instruction: 0x4770b012 │ │ │ │ strlt r4, [r0, #-1772] @ 0xfffff914 │ │ │ │ andpl lr, r0, sp, lsr #18 │ │ │ │ svcne 0x00ffe92d │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ - 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