--- /srv/rebuilderd/tmp/rebuilderdqe5xfz/inputs/qt6-scxml-examples_6.9.2-3_armhf.deb +++ /srv/rebuilderd/tmp/rebuilderdqe5xfz/out/qt6-scxml-examples_6.9.2-3_armhf.deb ├── file list │ @@ -1,3 +1,3 @@ │ -rw-r--r-- 0 0 0 4 2025-10-29 21:54:06.000000 debian-binary │ -rw-r--r-- 0 0 0 1244 2025-10-29 21:54:06.000000 control.tar.xz │ --rw-r--r-- 0 0 0 142064 2025-10-29 21:54:06.000000 data.tar.xz │ +-rw-r--r-- 0 0 0 142072 2025-10-29 21:54:06.000000 data.tar.xz ├── control.tar.xz │ ├── control.tar │ │ ├── ./md5sums │ │ │ ├── ./md5sums │ │ │ │┄ Files differ ├── data.tar.xz │ ├── data.tar │ │ ├── ./usr/lib/arm-linux-gnueabihf/qt6/examples/scxml/mediaplayer/mediaplayerscxml │ │ │┄ File has been modified after NT_GNU_BUILD_ID has been applied. │ │ │ ├── readelf --wide --sections {} │ │ │ │ @@ -10,16 +10,16 @@ │ │ │ │ [ 5] .dynstr STRTAB 00000b38 000b38 001583 00 A 0 0 1 │ │ │ │ [ 6] .gnu.version VERSYM 000020bc 0020bc 000128 02 A 4 0 2 │ │ │ │ [ 7] .gnu.version_r VERNEED 000021e4 0021e4 000160 00 A 5 8 4 │ │ │ │ [ 8] .rel.dyn REL 00002344 002344 000690 08 A 4 0 4 │ │ │ │ [ 9] .rel.plt REL 000029d4 0029d4 000310 08 AI 4 23 4 │ │ │ │ [10] .init PROGBITS 00002ce4 002ce4 00000c 00 AX 0 0 4 │ │ │ │ [11] .plt PROGBITS 00002cf0 002cf0 0004d4 04 AX 0 0 4 │ │ │ │ - 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@ instruction: 0xf8d8ebd8 │ │ │ │ + @ instruction: 0xf8d8ebda │ │ │ │ stccc 0, cr3, [r8, #64] @ 0x40 │ │ │ │ ldrhle r4, [r5, #35] @ 0x23 │ │ │ │ stcne 8, cr15, [ip], {89} @ 0x59 │ │ │ │ - blx ce45a <__bss_end__@@Base+0xadf12> │ │ │ │ + blx ce456 <__bss_end__@@Base+0xadf0e> │ │ │ │ tstpcc r8, r1, lsl #2 @ p-variant is OBSOLETE │ │ │ │ andeq pc, r8, r6, lsr #3 │ │ │ │ - bl fec43638 <__bss_end__@@Base+0xfec230f0> │ │ │ │ + bl fecc3634 <__bss_end__@@Base+0xfeca30ec> │ │ │ │ tstcs r4, r0, asr #12 │ │ │ │ mvnsmi lr, #12386304 @ 0xbd0000 │ │ │ │ - bllt ff543644 <__bss_end__@@Base+0xff5230fc> │ │ │ │ + bllt ff5c3640 <__bss_end__@@Base+0xff5a30f8> │ │ │ │ mvnshi lr, #12386304 @ 0xbd0000 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00e0f8cc │ │ │ │ @ instruction: 0x46064936 │ │ │ │ svchi 0x005bf3bf │ │ │ │ ldrbtmi r2, [r9], #-6 │ │ │ │ - bl ff443668 <__bss_end__@@Base+0xff423120> │ │ │ │ - blcs 1f744 <_IO_stdin_used@@Base+0x16f84> │ │ │ │ + bl ff4c3664 <__bss_end__@@Base+0xff4a311c> │ │ │ │ + blcs 1f740 <_IO_stdin_used@@Base+0x16f80> │ │ │ │ ldmdavs sl, {r0, r1, r2, r4, r6, ip, lr, pc} │ │ │ │ subsle r3, r4, r1, lsl #4 │ │ │ │ svchi 0x005bf3bf │ │ │ │ svcne 0x0000e853 │ │ │ │ stmda r3, {r0, r8, fp, ip, sp}^ │ │ │ │ - bcs 9e90 <_IO_stdin_used@@Base+0x16d0> │ │ │ │ + bcs 9e8c <_IO_stdin_used@@Base+0x16cc> │ │ │ │ vsra.u64 , q12, #1 │ │ │ │ stmdbcs r0, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc} │ │ │ │ ldmdavs r3!, {r0, r1, r2, r6, r8, ip, lr, pc} │ │ │ │ - blcs 17100 <_IO_stdin_used@@Base+0xe940> │ │ │ │ + blcs 170fc <_IO_stdin_used@@Base+0xe93c> │ │ │ │ ldmdbvs fp, {r0, r1, r6, ip, lr, pc} │ │ │ │ @ instruction: 0xf853b3eb │ │ │ │ addcs r7, r8, #4, 24 @ 0x400 │ │ │ │ strcc pc, [r7, -r2, lsl #22] │ │ │ │ ldrhtle r4, [r1], -fp │ │ │ │ streq pc, [r9, #-423] @ 0xfffffe59 │ │ │ │ svccc 0x008846b9 │ │ │ │ @@ -2376,35 +2375,35 @@ │ │ │ │ stmdbcc r1, {r8, r9, sl, fp, ip} │ │ │ │ stcne 8, cr14, [r0], {66} @ 0x42 │ │ │ │ svceq 0x0000f1bc │ │ │ │ vsra.u64 , , #1 │ │ │ │ stmdblt r1!, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc} │ │ │ │ andcs r5, r8, #192, 16 @ 0xc00000 │ │ │ │ @ instruction: 0xf7fd2102 │ │ │ │ - @ instruction: 0xf8d7eb3a │ │ │ │ + @ instruction: 0xf8d7eb3c │ │ │ │ adcmi r0, r5, #128 @ 0x80 │ │ │ │ smlattlt r8, r2, r1, sp │ │ │ │ - bl 1a436f8 <__bss_end__@@Base+0x1a231b0> │ │ │ │ + bl 1ac36f4 <__bss_end__@@Base+0x1aa31ac> │ │ │ │ @ instruction: 0x3010f8d8 │ │ │ │ adcsmi r3, fp, #136, 26 @ 0x2200 │ │ │ │ @ instruction: 0xf859d1d4 │ │ │ │ orrcs r1, r8, #140, 24 @ 0x8c00 │ │ │ │ @ instruction: 0xf101fb03 │ │ │ │ @ instruction: 0xf1a73108 │ │ │ │ @ instruction: 0xf7fd0008 │ │ │ │ - tstcs r4, r2, asr #22 │ │ │ │ + tstcs r4, r4, asr #22 │ │ │ │ @ instruction: 0xf7fd4640 │ │ │ │ - blmi 1c04d4 <__bss_end__@@Base+0x19ff8c> │ │ │ │ + blmi 1c04d8 <__bss_end__@@Base+0x19ff90> │ │ │ │ @ instruction: 0xf06f447b │ │ │ │ vsubl.u q0, d15, d1 │ │ │ │ ldrvc r8, [sl, #-3931] @ 0xfffff0a5 │ │ │ │ pop {r4, r5, r9, sl, lr} │ │ │ │ svclt 0x000083f8 │ │ │ │ andeq r0, r0, r7, asr #18 │ │ │ │ - andeq sl, r1, r0, lsr #26 │ │ │ │ + andeq sl, r1, r4, lsr #26 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0090f8cc │ │ │ │ @ instruction: 0x3630f8df │ │ │ │ pkhbtmi fp, r9, r3, lsl #1 │ │ │ │ andls r4, r8, fp, ror r4 │ │ │ │ @@ -2413,143 +2412,143 @@ │ │ │ │ strls r4, [r2], #-8 │ │ │ │ rsble r2, r6, r0, lsl #24 │ │ │ │ @ instruction: 0xf8dbab10 │ │ │ │ ldmib r1, {r2, r3, sp}^ │ │ │ │ stmib sp, {r0, r9, sl, pc}^ │ │ │ │ movwls r6, #6160 @ 0x1810 │ │ │ │ muleq r3, r3, r8 │ │ │ │ - b ffd43780 <__bss_end__@@Base+0xffd23238> │ │ │ │ + b ffdc377c <__bss_end__@@Base+0xffda3234> │ │ │ │ @ instruction: 0xf8db1e63 │ │ │ │ andmi r2, r3, r0, lsl r0 │ │ │ │ @ instruction: 0xf0032188 │ │ │ │ @ instruction: 0x4645047f │ │ │ │ - blx 47f0e <__bss_end__@@Base+0x279c6> │ │ │ │ - blge 38ffb0 <__bss_end__@@Base+0x36fa68> │ │ │ │ + blx 47f0a <__bss_end__@@Base+0x279c2> │ │ │ │ + blge 38ffac <__bss_end__@@Base+0x36fa64> │ │ │ │ ldrbmi r9, [fp], -r5, lsl #6 │ │ │ │ @ instruction: 0xf1ca4693 │ │ │ │ strbmi r0, [r9], -r0, lsl #14 │ │ │ │ stmib sp, {r0, r3, r4, r5, r7, r9, sl, lr}^ │ │ │ │ ldrbmi r3, [r4], #-2819 @ 0xfffff4fd │ │ │ │ streq pc, [r0, sl, lsl #2] │ │ │ │ and r4, r3, fp, lsl #13 │ │ │ │ adcsmi r3, ip, #16777216 @ 0x1000000 │ │ │ │ andhi pc, r0, #0 │ │ │ │ - bcs fffe3854 <__bss_end__@@Base+0xfffc330c> │ │ │ │ + bcs fffe3850 <__bss_end__@@Base+0xfffc3308> │ │ │ │ addhi pc, r3, #0 │ │ │ │ ldrdcc pc, [r0], sl │ │ │ │ movwne lr, #11011 @ 0x2b03 │ │ │ │ andcc lr, r1, #3457024 @ 0x34c000 │ │ │ │ tstcs r0, #3358720 @ 0x334000 │ │ │ │ strvs lr, [lr, #-2509] @ 0xfffff633 │ │ │ │ @ instruction: 0xd1eb4296 │ │ │ │ stmdbls r1, {r0, r2, r8, r9, fp, ip, pc} │ │ │ │ stmdbgt r3, {r2, r3, r8, r9, fp, lr, pc} │ │ │ │ - bl ac37e8 <__bss_end__@@Base+0xaa32a0> │ │ │ │ + bl b437e4 <__bss_end__@@Base+0xb2329c> │ │ │ │ rscle r2, r3, r0, lsl #16 │ │ │ │ - bl 12c00c <__bss_end__@@Base+0x10bac4> │ │ │ │ + bl 12c008 <__bss_end__@@Base+0x10bac0> │ │ │ │ stmdbls r9, {r0, r3, r8, sl} │ │ │ │ movweq lr, #11178 @ 0x2baa │ │ │ │ ldrdlt pc, [ip], -sp │ │ │ │ sbcsne r6, fp, r8, lsl #16 │ │ │ │ mvnseq pc, pc, asr #4 │ │ │ │ mvnseq pc, pc, asr #5 │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ bicne lr, r3, #282624 @ 0x45000 │ │ │ │ @ instruction: 0xf0032588 │ │ │ │ ldmibeq ip, {r0, r1, r2, r3, r4, r5, r6, r8}^ │ │ │ │ andcs pc, r4, #5120 @ 0x1400 │ │ │ │ @ instruction: 0xf8d25c51 │ │ │ │ - bl 8da30 <__bss_end__@@Base+0x6d4e8> │ │ │ │ + bl 8da2c <__bss_end__@@Base+0x6d4e4> │ │ │ │ sbcsvs r1, r0, r1, lsl #4 │ │ │ │ ldrmi r9, [r0], -r8, lsl #20 │ │ │ │ movwlt lr, #2498 @ 0x9c2 │ │ │ │ pop {r0, r1, r4, ip, sp, pc} │ │ │ │ @ instruction: 0xf8db8ff0 │ │ │ │ movwcc r3, #4100 @ 0x1004 │ │ │ │ addshi pc, lr, #0 │ │ │ │ vqdmulh.s q9, q0, q0 │ │ │ │ - blx fece6264 <__bss_end__@@Base+0xfecc5d1c> │ │ │ │ - blcs 82664 <__bss_end__@@Base+0x6211c> │ │ │ │ + blx fece6260 <__bss_end__@@Base+0xfecc5d18> │ │ │ │ + blcs 82660 <__bss_end__@@Base+0x62118> │ │ │ │ addshi pc, r6, #64, 6 │ │ │ │ msreq CPSR_c, #-1073741776 @ 0xc0000030 │ │ │ │ @ instruction: 0xf8db2701 │ │ │ │ addsmi r4, pc, r0, lsl r0 @ │ │ │ │ mvnsmi pc, #1325400064 @ 0x4f000000 │ │ │ │ cmnpeq r8, #208666624 @ p-variant is OBSOLETE @ 0xc700000 │ │ │ │ vqsub.s8 d4, d16, d15 │ │ │ │ ldmibeq sp!, {r0, r3, r7, r9, pc}^ │ │ │ │ cdpne 0, 6, cr2, cr14, cr8, {4} │ │ │ │ @ instruction: 0xf000fb05 │ │ │ │ @ instruction: 0xf7fd3008 │ │ │ │ - orrcs lr, r8, #434176 @ 0x6a000 │ │ │ │ + orrcs lr, r8, #108, 20 @ 0x6c000 │ │ │ │ @ instruction: 0xf1006045 │ │ │ │ @ instruction: 0xf1000590 │ │ │ │ andvs r0, r3, r8, lsl #16 │ │ │ │ strpl pc, [r6, #-2819] @ 0xfffff4fd │ │ │ │ strcs r4, [r0], -r3, asr #12 │ │ │ │ @ instruction: 0xf8c34618 │ │ │ │ @ instruction: 0xf8a36080 │ │ │ │ addcs r6, r0, #132 @ 0x84 │ │ │ │ @ instruction: 0xf7fd21ff │ │ │ │ - @ instruction: 0xf100eb4c │ │ │ │ + @ instruction: 0xf100eb4e │ │ │ │ addsmi r0, sp, #136, 6 @ 0x20000002 │ │ │ │ - blls ba080 <__bss_end__@@Base+0x99b38> │ │ │ │ + blls ba07c <__bss_end__@@Base+0x99b34> │ │ │ │ andshi pc, r0, fp, asr #17 │ │ │ │ andvc pc, r8, fp, asr #17 │ │ │ │ @ instruction: 0xf00009db │ │ │ │ addcs r8, r8, #-536870907 @ 0xe0000005 │ │ │ │ strtmi r1, [r6], -r5, ror #28 │ │ │ │ movwmi pc, #15106 @ 0x3b02 @ │ │ │ │ - beq 2001ce0 <__bss_end__@@Base+0x1fe1798> │ │ │ │ + beq 2001cdc <__bss_end__@@Base+0x1fe1794> │ │ │ │ cmnpeq pc, #4, 2 @ p-variant is OBSOLETE │ │ │ │ movwls r4, #13908 @ 0x3654 │ │ │ │ movwls sl, #6928 @ 0x1b10 │ │ │ │ movwls sl, #23310 @ 0x5b0e │ │ │ │ stmib sp, {r2, r8, sl, ip, pc}^ │ │ │ │ stmib sp, {r1, r3, sl, ip, lr}^ │ │ │ │ - blls 11fd20 <__bss_end__@@Base+0xff7d8> │ │ │ │ + blls 11fd1c <__bss_end__@@Base+0xff7d4> │ │ │ │ svcvc 0x0001f813 │ │ │ │ svccs 0x00ff9304 │ │ │ │ - blls f9ab8 <__bss_end__@@Base+0xd9570> │ │ │ │ + blls f9ab4 <__bss_end__@@Base+0xd956c> │ │ │ │ @ instruction: 0xf8db013f │ │ │ │ @ instruction: 0xf8d3200c │ │ │ │ - blls 6590c <__bss_end__@@Base+0x453c4> │ │ │ │ + blls 65908 <__bss_end__@@Base+0x453c0> │ │ │ │ streq lr, [r7], -r8, lsl #22 │ │ │ │ stmdbge r1, {r1, r2, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - bls 440048 <__bss_end__@@Base+0x41fb00> │ │ │ │ + bls 440044 <__bss_end__@@Base+0x41fafc> │ │ │ │ muleq r3, r3, r8 │ │ │ │ - b b43910 <__bss_end__@@Base+0xb233c8> │ │ │ │ + b bc390c <__bss_end__@@Base+0xba33c4> │ │ │ │ ldrdcs pc, [r8], -fp │ │ │ │ @ instruction: 0xf8db2188 │ │ │ │ @ instruction: 0x46ce3010 │ │ │ │ @ instruction: 0x46c11e54 │ │ │ │ ldrtmi r4, [r0], r0, lsr #32 │ │ │ │ - ldcleq 0, cr15, [pc], #-0 @ 5934 <__aeabi_atexit@plt+0x2780> │ │ │ │ + ldcleq 0, cr15, [pc], #-0 @ 5930 <__aeabi_atexit@plt+0x277c> │ │ │ │ stmibeq r4, {r1, r2, r4, r9, sl, lr}^ │ │ │ │ @ instruction: 0x469a4652 │ │ │ │ strcc pc, [r4], #-2817 @ 0xfffff4ff │ │ │ │ strbtmi r9, [r5], -r2, lsl #14 │ │ │ │ ldrbmi r4, [r4], -r7, lsr #12 │ │ │ │ stmib sp, {r1, r4, r5, r7, r9, sl, lr}^ │ │ │ │ ldrtmi r2, [sp], #-3590 @ 0xfffff1fa │ │ │ │ streq pc, [r0], r7, lsl #2 │ │ │ │ strcc lr, [r1, #-3] │ │ │ │ @ instruction: 0xf00042b5 │ │ │ │ stmdavc fp!, {r0, r1, r2, r3, r6, r8, pc} │ │ │ │ @ instruction: 0xd0152bff │ │ │ │ ldrdcs pc, [r0], r7 │ │ │ │ - bl abd84 <__bss_end__@@Base+0x8b83c> │ │ │ │ + bl abd80 <__bss_end__@@Base+0x8b838> │ │ │ │ ldmib r3, {r0, r1, r8, r9, ip}^ │ │ │ │ stmib sp, {r0, r9, ip, sp}^ │ │ │ │ - blls 1ce5b8 <__bss_end__@@Base+0x1ae070> │ │ │ │ + blls 1ce5b4 <__bss_end__@@Base+0x1ae06c> │ │ │ │ addsmi r9, r3, #939524096 @ 0x38000000 │ │ │ │ mvnle r9, pc, lsl #2 │ │ │ │ stmdbls r1, {r0, r2, r8, r9, fp, ip, pc} │ │ │ │ stmdbgt r3, {r2, r3, r8, r9, fp, lr, pc} │ │ │ │ - b 17c3980 <__bss_end__@@Base+0x17a3438> │ │ │ │ + b 184397c <__bss_end__@@Base+0x1823434> │ │ │ │ rscle r2, r2, r0, lsl #16 │ │ │ │ @ instruction: 0x4646463c │ │ │ │ strbmi r9, [r8], r2, lsl #30 │ │ │ │ @ instruction: 0xf8941b2d │ │ │ │ @ instruction: 0xf8942085 │ │ │ │ addsmi r3, sl, #132 @ 0x84 │ │ │ │ mrshi pc, (UNDEF: 64) @ │ │ │ │ @@ -2580,18 +2579,18 @@ │ │ │ │ stmdbcc r1, {r8, r9, sl, fp, ip} │ │ │ │ stcne 8, cr14, [r0], {66} @ 0x42 │ │ │ │ svceq 0x0000f1bc │ │ │ │ vsra.u64 , , #1 │ │ │ │ stmdblt r1!, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc} │ │ │ │ andcs r5, r8, #192, 16 @ 0xc00000 │ │ │ │ @ instruction: 0xf7fd2102 │ │ │ │ - @ instruction: 0xf8d8e9a2 │ │ │ │ + @ instruction: 0xf8d8e9a4 │ │ │ │ strbmi r0, [r7, #-1] │ │ │ │ smlattlt r8, r2, r1, sp │ │ │ │ - ldmib r0, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmib r2, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ movwcs r9, #2563 @ 0xa03 │ │ │ │ andcc pc, r1, r2, asr #17 │ │ │ │ strcc r9, [r8, #2819] @ 0xb03 │ │ │ │ movwls r3, #13192 @ 0x3388 │ │ │ │ @ instruction: 0xf47f429c │ │ │ │ ldrtmi sl, [r4], -sp, asr #30 │ │ │ │ @ instruction: 0xf854b3dc │ │ │ │ @@ -2610,55 +2609,55 @@ │ │ │ │ stmdbcc r1, {r8, r9, sl, fp, ip} │ │ │ │ stcne 8, cr14, [r0], {66} @ 0x42 │ │ │ │ svceq 0x0000f1bc │ │ │ │ vsra.u64 , , #1 │ │ │ │ stmdblt r1!, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc} │ │ │ │ andcs r5, r8, #192, 16 @ 0xc00000 │ │ │ │ @ instruction: 0xf7fd2102 │ │ │ │ - @ instruction: 0xf8d7e966 │ │ │ │ + @ instruction: 0xf8d7e968 │ │ │ │ adcsmi r0, r5, #128 @ 0x80 │ │ │ │ smlattlt r8, r2, r1, sp │ │ │ │ - ldmib r4, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib r6, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ adcmi r3, r7, #136, 28 @ 0x880 │ │ │ │ @ instruction: 0xf854d1d7 │ │ │ │ orrcs r1, r8, #4, 24 @ 0x400 │ │ │ │ @ instruction: 0xf101fb03 │ │ │ │ @ instruction: 0xf1a43108 │ │ │ │ @ instruction: 0xf7fd0008 │ │ │ │ - blls 80088 <__bss_end__@@Base+0x5fb40> │ │ │ │ + blls 8008c <__bss_end__@@Base+0x5fb44> │ │ │ │ strvc lr, [r1], #-2521 @ 0xfffff627 │ │ │ │ ldrdcs pc, [ip], -fp │ │ │ │ ldrmi lr, [r0, -sp, asr #19] │ │ │ │ muleq r3, r3, r8 │ │ │ │ - stmdb ip, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb lr, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrdcs pc, [r8], -fp │ │ │ │ movwls sl, #15118 @ 0x3b0e │ │ │ │ cdpne 1, 5, cr2, cr3, cr8, {4} │ │ │ │ @ instruction: 0x6010f8db │ │ │ │ @ instruction: 0xf0034003 │ │ │ │ ldmibeq fp, {r0, r1, r2, r3, r4, r5, r6, r8, sl}^ │ │ │ │ - bvs 1046fc <__bss_end__@@Base+0xe41b4> │ │ │ │ + bvs 1046f8 <__bss_end__@@Base+0xe41b0> │ │ │ │ ldrmi r4, [r1], fp, asr #12 │ │ │ │ @ instruction: 0xf10a461a │ │ │ │ @ instruction: 0xf8cd0880 │ │ │ │ ldrbmi fp, [r5], #-8 │ │ │ │ mul r3, r3, r6 │ │ │ │ strbmi r3, [r5, #-1281] @ 0xfffffaff │ │ │ │ sbchi pc, sl, r0 │ │ │ │ - bcs fffe3bc0 <__bss_end__@@Base+0xfffc3678> │ │ │ │ + bcs fffe3bbc <__bss_end__@@Base+0xfffc3674> │ │ │ │ @ instruction: 0xf8dad013 │ │ │ │ - bl d1d20 <__bss_end__@@Base+0xb17d8> │ │ │ │ + bl d1d1c <__bss_end__@@Base+0xb17d4> │ │ │ │ ldmib r3, {r1, r8, r9, ip}^ │ │ │ │ stmib sp, {r0, r9, ip, sp}^ │ │ │ │ stmib sp, {r4, r8, r9, sp}^ │ │ │ │ addsmi r4, r4, #3670016 @ 0x380000 │ │ │ │ - blls fa2e4 <__bss_end__@@Base+0xd9d9c> │ │ │ │ - blgt 32bf3c <__bss_end__@@Base+0x30b9f4> │ │ │ │ + blls fa2e0 <__bss_end__@@Base+0xd9d98> │ │ │ │ + blgt 32bf38 <__bss_end__@@Base+0x30b9f0> │ │ │ │ @ instruction: 0xf7fdc903 │ │ │ │ - stmdacs r0, {r1, r2, r7, r8, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r3, r7, r8, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf89ad0e4 │ │ │ │ ldrbmi r2, [r9], r5, lsl #1 │ │ │ │ umullcc pc, r4, sl, r8 @ │ │ │ │ streq lr, [sl, #-2981] @ 0xfffff45b │ │ │ │ ldrdlt pc, [r8], -sp │ │ │ │ @ instruction: 0xf000429a │ │ │ │ @ instruction: 0xf8da80d1 │ │ │ │ @@ -2667,20 +2666,20 @@ │ │ │ │ rscseq pc, r0, pc, asr #5 │ │ │ │ strcs r5, [r8], #3299 @ 0xce3 │ │ │ │ addcc pc, r5, sl, lsl #17 │ │ │ │ andcs pc, r5, sl, lsl #16 │ │ │ │ @ instruction: 0xf8db9b09 │ │ │ │ ldmdavs r9, {r4, sp} │ │ │ │ movweq lr, #11178 @ 0x2baa │ │ │ │ - blx 9ef2 <_IO_stdin_used@@Base+0x1732> │ │ │ │ + blx 9eee <_IO_stdin_used@@Base+0x172e> │ │ │ │ @ instruction: 0xf8dbf303 │ │ │ │ andcc r0, r1, r4 │ │ │ │ andeq pc, r4, fp, asr #17 │ │ │ │ bicne lr, r3, #282624 @ 0x45000 │ │ │ │ - blx 1082fa <__bss_end__@@Base+0xe7db2> │ │ │ │ + blx 1082f6 <__bss_end__@@Base+0xe7dae> │ │ │ │ @ instruction: 0xf0032200 │ │ │ │ @ instruction: 0xf8d9007f │ │ │ │ ldcpl 0, cr4, [r0], {-0} │ │ │ │ ldrdcs pc, [r0], r2 │ │ │ │ andspl r0, r4, r0, lsl #2 │ │ │ │ @ instruction: 0xf8d94402 │ │ │ │ subsvs r0, r0, r4 │ │ │ │ @@ -2689,124 +2688,124 @@ │ │ │ │ andeq lr, r0, r9, asr #19 │ │ │ │ andeq pc, r8, r9, asr #17 │ │ │ │ @ instruction: 0xe63560d1 │ │ │ │ @ instruction: 0xf8dd4659 │ │ │ │ @ instruction: 0xf10ab010 │ │ │ │ vpmax.s8 d16, d31, d8 │ │ │ │ vshr.s64 q8, , #49 │ │ │ │ - bl fea85f9c <__bss_end__@@Base+0xfea65a54> │ │ │ │ - blls c640c <__bss_end__@@Base+0xa5ec4> │ │ │ │ + bl fea85f98 <__bss_end__@@Base+0xfea65a50> │ │ │ │ + blls c6408 <__bss_end__@@Base+0xa5ec0> │ │ │ │ stmibeq r8, {r0, r3, r5, r7, r8, ip, sp, lr, pc} │ │ │ │ strcs r1, [r0], #-210 @ 0xffffff2e │ │ │ │ vqdmulh.s d15, d2, d0 │ │ │ │ - bl fecabbf8 <__bss_end__@@Base+0xfec8b6b0> │ │ │ │ + bl fecabbf4 <__bss_end__@@Base+0xfec8b6ac> │ │ │ │ @ instruction: 0xf47f1fd0 │ │ │ │ pkhtbmi sl, r9, lr, asr #27 │ │ │ │ ldrb r4, [r6, #1754] @ 0x6da │ │ │ │ vabd.s8 d19, d31, d8 │ │ │ │ vsra.s64 q8, , #49 │ │ │ │ - blne ec63c8 <__bss_end__@@Base+0xea5e80> │ │ │ │ + blne ec63c4 <__bss_end__@@Base+0xea5e7c> │ │ │ │ stceq 0, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x466510db │ │ │ │ vqrdmulh.s d15, d3, d1 │ │ │ │ svcne 0x00daebb3 │ │ │ │ mrcge 4, 4, APSR_nzcv, cr9, cr15, {3} │ │ │ │ svcls 0x00024656 │ │ │ │ @ instruction: 0x2e06e9dd │ │ │ │ str r4, [fp], r2, lsr #13 │ │ │ │ ldrmi fp, [r2], sl, asr #6 │ │ │ │ eorsle r2, r1, r0, lsr sl │ │ │ │ tstpeq r0, #-2147483648 @ p-variant is OBSOLETE @ 0x80000000 │ │ │ │ movwls r9, #8710 @ 0x2206 │ │ │ │ @ instruction: 0xf7fd0118 │ │ │ │ - blls bfe78 <__bss_end__@@Base+0x9f930> │ │ │ │ + blls bfe7c <__bss_end__@@Base+0x9f934> │ │ │ │ strmi r9, [r1], r6, lsl #20 │ │ │ │ ldrdne pc, [r0], r4 │ │ │ │ @ instruction: 0x46480112 │ │ │ │ @ instruction: 0xf7fd9306 │ │ │ │ - blls 1c0494 <__bss_end__@@Base+0x19ff4c> │ │ │ │ + blls 1c0498 <__bss_end__@@Base+0x19ff50> │ │ │ │ andne lr, sl, #323584 @ 0x4f000 │ │ │ │ - beq 82084 <__bss_end__@@Base+0x61b3c> │ │ │ │ + beq 82080 <__bss_end__@@Base+0x61b38> │ │ │ │ @ instruction: 0xf809459a │ │ │ │ mvnsle sl, #2 │ │ │ │ ldrdeq pc, [r0], r4 │ │ │ │ @ instruction: 0xf7fdb108 │ │ │ │ - blls bff40 <__bss_end__@@Base+0x9f9f8> │ │ │ │ + blls bff44 <__bss_end__@@Base+0x9f9fc> │ │ │ │ umullcs pc, r5, r4, r8 @ │ │ │ │ addcc pc, r4, r4, lsl #17 │ │ │ │ addls pc, r0, r4, asr #17 │ │ │ │ vst1.32 {d30-d32}, [pc :64], r6 │ │ │ │ andls r7, r2, #64 @ 0x40 │ │ │ │ - stmda r8!, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda sl!, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrdge pc, [r8], -sp │ │ │ │ @ instruction: 0x46812330 │ │ │ │ ldrb r9, [pc, r2, lsl #6] │ │ │ │ adcvs pc, r0, pc, asr #8 │ │ │ │ @ instruction: 0xf7fd9206 │ │ │ │ - cmpcs r0, #6160384 @ 0x5e0000 │ │ │ │ + cmpcs r0, #96, 16 @ 0x600000 │ │ │ │ strmi r9, [r1], r6, lsl #20 │ │ │ │ strb r9, [sp, r2, lsl #6] │ │ │ │ - beq fe2420d4 <__bss_end__@@Base+0xfe221b8c> │ │ │ │ + beq fe2420d0 <__bss_end__@@Base+0xfe221b88> │ │ │ │ mvnseq pc, pc, asr #4 │ │ │ │ mvnseq pc, pc, asr #5 │ │ │ │ movweq lr, #27562 @ 0x6baa │ │ │ │ @ instruction: 0xf105465a │ │ │ │ sbcsne r0, fp, r8, lsl #17 │ │ │ │ ldrdlt pc, [r8], -sp │ │ │ │ - blx 4f0ca <__bss_end__@@Base+0x2eb82> │ │ │ │ - bl fed028d8 <__bss_end__@@Base+0xfece2390> │ │ │ │ + blx 4f0c6 <__bss_end__@@Base+0x2eb7e> │ │ │ │ + bl fed028d4 <__bss_end__@@Base+0xfece238c> │ │ │ │ @ instruction: 0xf47f1fd9 │ │ │ │ ssatmi sl, #19, r8, lsl #30 │ │ │ │ - bl 13f924 <__bss_end__@@Base+0x11f3dc> │ │ │ │ + bl 13f920 <__bss_end__@@Base+0x11f3d8> │ │ │ │ ldrbmi r0, [r9], r9, lsl #10 │ │ │ │ ldrdlt pc, [ip], -sp │ │ │ │ @ instruction: 0xf8db9a02 │ │ │ │ - bl fecd1cf8 <__bss_end__@@Base+0xfecb17b0> │ │ │ │ + bl fecd1cf4 <__bss_end__@@Base+0xfecb17ac> │ │ │ │ @ instruction: 0xf4bf0f52 │ │ │ │ @ instruction: 0xf89aadac │ │ │ │ @ instruction: 0xf89a2085 │ │ │ │ addsmi r3, sl, #132 @ 0x84 │ │ │ │ svcge 0x002ff47f │ │ │ │ @ instruction: 0x4616b192 │ │ │ │ eorsle r2, r1, r0, lsr sl │ │ │ │ ldreq pc, [r0, -r2, lsl #2] │ │ │ │ ldrtmi r9, [r8], r1, lsl #4 │ │ │ │ @ instruction: 0xf7fd0138 │ │ │ │ - bls 7fda4 <__bss_end__@@Base+0x5f85c> │ │ │ │ + bls 7fda8 <__bss_end__@@Base+0x5f860> │ │ │ │ @ instruction: 0xf8da4604 │ │ │ │ tsteq r2, r0, lsl #1 │ │ │ │ @ instruction: 0xf7fd4620 │ │ │ │ - and lr, r9, r8, lsr #19 │ │ │ │ + and lr, r9, sl, lsr #19 │ │ │ │ subvc pc, r0, pc, asr #8 │ │ │ │ ldmdaeq r0!, {r0, r1, r2, r3, r6, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fd9201 │ │ │ │ - mcrls 8, 0, lr, cr1, cr4, {0} │ │ │ │ + mcrls 8, 0, lr, cr1, cr6, {0} │ │ │ │ strbmi r4, [r7], -r4, lsl #12 │ │ │ │ @ instruction: 0x36010133 │ │ │ │ strbtpl r4, [r6], #702 @ 0x2be │ │ │ │ @ instruction: 0xf8dad3fa │ │ │ │ smlabblt r8, r0, r0, r0 │ │ │ │ - stmda r4, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda r6, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ umullcs pc, r5, sl, r8 @ │ │ │ │ addhi pc, r4, sl, lsl #17 │ │ │ │ addmi pc, r0, sl, asr #17 │ │ │ │ @ instruction: 0xf8dbe701 │ │ │ │ @ instruction: 0x26004010 │ │ │ │ strcs r2, [r1, #-144] @ 0xffffff70 │ │ │ │ str r2, [ip, #1920] @ 0x780 │ │ │ │ adcvs pc, r0, pc, asr #8 │ │ │ │ ldmdaeq r0, {r0, r1, r2, r3, r6, ip, sp, lr, pc}^ │ │ │ │ strbmi r9, [r7], -r1, lsl #4 │ │ │ │ - svc 0x00f0f7fc │ │ │ │ + svc 0x00f2f7fc │ │ │ │ strmi r9, [r4], -r1, lsl #20 │ │ │ │ smlabtcs r0, fp, r7, lr │ │ │ │ - blge 43f7f4 <__bss_end__@@Base+0x41f2ac> │ │ │ │ + blge 43f7f0 <__bss_end__@@Base+0x41f2a8> │ │ │ │ strbt r9, [r1], -r1, lsl #6 │ │ │ │ - stmia r2!, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - andeq sl, r1, ip, ror #25 │ │ │ │ + stmia r4!, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + strdeq sl, [r1], -r0 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00a0f8cc │ │ │ │ addslt r4, r1, fp, ror sl │ │ │ │ @ instruction: 0x21222300 │ │ │ │ strcs r4, [r0], #-1146 @ 0xfffffb86 │ │ │ │ @@ -2815,930 +2814,930 @@ │ │ │ │ andscs r9, r4, r4, lsl #6 │ │ │ │ movwls r4, #42106 @ 0xa47a │ │ │ │ stmib sp, {r0, r1, r8, r9, ip, pc}^ │ │ │ │ orrsvs r4, r3, r8, lsl #10 │ │ │ │ tstls r6, r4, ror sl │ │ │ │ stmib sp, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ andls r3, r5, #12, 4 @ 0xc0000000 │ │ │ │ - blmi 1cd879c <__bss_end__@@Base+0x1cb8254> │ │ │ │ + blmi 1cd8798 <__bss_end__@@Base+0x1cb8250> │ │ │ │ tstls lr, sl, ror r4 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f930f │ │ │ │ @ instruction: 0xf7fd0300 │ │ │ │ - strmi lr, [r4], -r4, lsr #16 │ │ │ │ + strmi lr, [r4], -r6, lsr #16 │ │ │ │ mrscs r2, SP_irq │ │ │ │ addscs r2, r0, r0, lsl #5 │ │ │ │ stmib r4, {r0, r5, sp, lr}^ │ │ │ │ stmib r4, {r0, r1, r8, r9, ip, sp}^ │ │ │ │ @ instruction: 0xf7fc3201 │ │ │ │ - andcs lr, r0, #696 @ 0x2b8 │ │ │ │ + andcs lr, r0, #176, 30 @ 0x2c0 │ │ │ │ @ instruction: 0xf8c02101 │ │ │ │ strcs r2, [r8, #136] @ 0x88 │ │ │ │ addcs pc, ip, r0, lsr #17 │ │ │ │ subvs r2, r1, r0, lsl #5 │ │ │ │ strdvs r2, [r5], -pc @ │ │ │ │ @ instruction: 0xf7fd3008 │ │ │ │ - @ instruction: 0x6120e896 │ │ │ │ - stmdb ip, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + @ instruction: 0x6120e898 │ │ │ │ + stmdb lr, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stmdbge ip, {r5, r6, r8, r9, fp, lr} │ │ │ │ ldrbtmi r6, [fp], #-224 @ 0xffffff20 │ │ │ │ strbtmi sl, [r8], -r2, lsl #20 │ │ │ │ orrsvs r4, ip, pc, lsl #12 │ │ │ │ stc2 7, cr15, [sl], {255} @ 0xff │ │ │ │ - blcs 2ca44 <__bss_end__@@Base+0xc4fc> │ │ │ │ + blcs 2ca40 <__bss_end__@@Base+0xc4f8> │ │ │ │ ldmdavs sl, {r1, r2, r4, r6, ip, lr, pc} │ │ │ │ subsle r3, r3, r1, lsl #4 │ │ │ │ svchi 0x005bf3bf │ │ │ │ svcne 0x0000e853 │ │ │ │ stmda r3, {r0, r8, fp, ip, sp}^ │ │ │ │ - bcs a650 <_IO_stdin_used@@Base+0x1e90> │ │ │ │ + bcs a64c <_IO_stdin_used@@Base+0x1e8c> │ │ │ │ vsra.u64 , q12, #1 │ │ │ │ stmdbcs r0, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc} │ │ │ │ - blls fa374 <__bss_end__@@Base+0xd9e2c> │ │ │ │ - blcs 178c0 <_IO_stdin_used@@Base+0xf100> │ │ │ │ + blls fa370 <__bss_end__@@Base+0xd9e28> │ │ │ │ + blcs 178bc <_IO_stdin_used@@Base+0xf0fc> │ │ │ │ ldmdbvs fp, {r1, r6, ip, lr, pc} │ │ │ │ @ instruction: 0xf853b3e3 │ │ │ │ - blx 160e7e <__bss_end__@@Base+0x140936> │ │ │ │ + blx 160e7a <__bss_end__@@Base+0x140932> │ │ │ │ adcsmi r3, r3, #6291456 @ 0x600000 │ │ │ │ @ instruction: 0xf1a6d031 │ │ │ │ ldrtmi r0, [r1], r9, lsl #10 │ │ │ │ @ instruction: 0xf8d63e88 │ │ │ │ tstlt r0, #128 @ 0x80 │ │ │ │ @ instruction: 0xf8141e74 │ │ │ │ - blcs fffd5a8c <__bss_end__@@Base+0xfffb5544> │ │ │ │ + blcs fffd5a88 <__bss_end__@@Base+0xfffb5540> │ │ │ │ tsteq fp, r6, lsl r0 │ │ │ │ orrslt r5, sl, r2, asr #17 │ │ │ │ svchi 0x005bf3bf │ │ │ │ svcne 0x0000e852 │ │ │ │ stmda r2, {r0, r8, fp, ip, sp}^ │ │ │ │ @ instruction: 0xf1bc1c00 │ │ │ │ mvnsle r0, r0, lsl #30 │ │ │ │ svchi 0x005bf3bf │ │ │ │ stmiapl r0, {r0, r5, r8, fp, ip, sp, pc}^ │ │ │ │ tstcs r2, r8, lsl #4 │ │ │ │ - svc 0x005af7fc │ │ │ │ + svc 0x005cf7fc │ │ │ │ ldrdeq pc, [r0], r6 │ │ │ │ mvnle r4, r5, lsr #5 │ │ │ │ @ instruction: 0xf7fcb108 │ │ │ │ - @ instruction: 0xf8d8ef8a │ │ │ │ + @ instruction: 0xf8d8ef8c │ │ │ │ stccc 0, cr3, [r8, #64] @ 0x40 │ │ │ │ ldrhle r4, [r4, #35] @ 0x23 │ │ │ │ stcne 8, cr15, [ip], {89} @ 0x59 │ │ │ │ - blx cecf6 <__bss_end__@@Base+0xae7ae> │ │ │ │ + blx cecf2 <__bss_end__@@Base+0xae7aa> │ │ │ │ tstpcc r8, r1, lsl #2 @ p-variant is OBSOLETE │ │ │ │ andeq pc, r8, r6, lsr #3 │ │ │ │ - svc 0x0062f7fc │ │ │ │ + svc 0x0064f7fc │ │ │ │ @ instruction: 0x46402114 │ │ │ │ - svc 0x008af7fc │ │ │ │ + svc 0x008cf7fc │ │ │ │ cmplt fp, ip, lsl #22 │ │ │ │ svchi 0x005bf3bf │ │ │ │ svccs 0x0000e853 │ │ │ │ stmda r3, {r0, r9, fp, ip, sp}^ │ │ │ │ stmdbcs r0, {r8, sp} │ │ │ │ vsra.u64 , q12, #1 │ │ │ │ @ instruction: 0xb1aa8f5b │ │ │ │ ldrtmi r4, [r9], -r8, lsr #22 │ │ │ │ andcs r2, r0, #6 │ │ │ │ stmib sp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ @ instruction: 0xf7fc230c │ │ │ │ - bmi 981b00 <__bss_end__@@Base+0x9615b8> │ │ │ │ + bmi 981b04 <__bss_end__@@Base+0x9615bc> │ │ │ │ ldrbtmi r4, [sl], #-2849 @ 0xfffff4df │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, pc, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andslt sp, r1, r8, lsl r1 │ │ │ │ mvnshi lr, #12386304 @ 0xbd0000 │ │ │ │ andcs r9, r8, #12, 16 @ 0xc0000 │ │ │ │ @ instruction: 0xf7fc2102 │ │ │ │ - @ instruction: 0xe7e3ef18 │ │ │ │ + @ instruction: 0xe7e3ef1a │ │ │ │ ldmdami ip, {r2, r9, sl, lr} │ │ │ │ andscc r4, r8, r8, ror r4 │ │ │ │ - blx 843f46 <__bss_end__@@Base+0x8239fe> │ │ │ │ - blmi 5587b4 <__bss_end__@@Base+0x53826c> │ │ │ │ + blx 843f42 <__bss_end__@@Base+0x8239fa> │ │ │ │ + blmi 5587b0 <__bss_end__@@Base+0x538268> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 3dffbc <__bss_end__@@Base+0x3bfa74> │ │ │ │ + blls 3dffb8 <__bss_end__@@Base+0x3bfa70> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ andsle r0, r6, r0, lsl #6 │ │ │ │ - svc 0x002ef7fc │ │ │ │ + svc 0x0030f7fc │ │ │ │ strtmi r4, [r0], -r5, lsl #12 │ │ │ │ tstcs r4, ip, lsr #12 │ │ │ │ - svc 0x0048f7fc │ │ │ │ + svc 0x004af7fc │ │ │ │ @ instruction: 0xf7ffa803 │ │ │ │ stmdage ip, {r0, r1, r3, r8, r9, fp, ip, sp, lr, pc} │ │ │ │ - ldc2 7, cr15, [r0, #-1012] @ 0xfffffc0c │ │ │ │ + ldc2 7, cr15, [r2, #-1012] @ 0xfffffc0c │ │ │ │ @ instruction: 0xf7fda804 │ │ │ │ - stmdage r8, {r0, r2, r3, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ - stc2 7, cr15, [sl, #-1012] @ 0xfffffc0c │ │ │ │ + stmdage r8, {r0, r1, r2, r3, r8, sl, fp, ip, sp, lr, pc} │ │ │ │ + stc2 7, cr15, [ip, #-1012] @ 0xfffffc0c │ │ │ │ @ instruction: 0x4604e7db │ │ │ │ @ instruction: 0x4620e7f0 │ │ │ │ - svc 0x0076f7fc │ │ │ │ - ldrdeq r9, [r1], -r0 │ │ │ │ - muleq r1, r4, r6 │ │ │ │ - andeq r2, r0, r4, asr #22 │ │ │ │ - andeq sl, r1, r4, asr r0 │ │ │ │ + svc 0x0078f7fc │ │ │ │ + ldrdeq r9, [r1], -r4 │ │ │ │ + muleq r1, r8, r6 │ │ │ │ + andeq r2, r0, r8, asr #22 │ │ │ │ + andeq sl, r1, r8, asr r0 │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq sl, r1, r6, lsr #12 │ │ │ │ + andeq sl, r1, sl, lsr #12 │ │ │ │ andeq r0, r0, r9, lsr #1 │ │ │ │ - andeq r9, r1, lr, lsl #30 │ │ │ │ - andeq sl, r1, ip, lsl #10 │ │ │ │ - ldrdeq r9, [r1], -ip │ │ │ │ + andeq r9, r1, r2, lsl pc │ │ │ │ + andeq sl, r1, r0, lsl r5 │ │ │ │ + andeq r9, r1, r0, ror #29 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00a8f8cc │ │ │ │ @ instruction: 0xb08d4ab0 │ │ │ │ svcge 0x00084bb0 │ │ │ │ @ instruction: 0x4601447a │ │ │ │ ldrtmi r4, [r8], -r5, lsl #12 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f930b │ │ │ │ @ instruction: 0xf7fd0300 │ │ │ │ - bls 2c0028 <__bss_end__@@Base+0x29fae0> │ │ │ │ - blmi fea8e3f8 <__bss_end__@@Base+0xfea6deb0> │ │ │ │ + bls 2c002c <__bss_end__@@Base+0x29fae4> │ │ │ │ + blmi fea8e3f4 <__bss_end__@@Base+0xfea6deac> │ │ │ │ addmi r9, sl, #8, 24 @ 0x800 │ │ │ │ stmib sp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ eorle r1, r1, r3, lsl #6 │ │ │ │ vaddw.u , , d4 │ │ │ │ ldmda r4, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc}^ │ │ │ │ - blcc 55c04 <__bss_end__@@Base+0x356bc> │ │ │ │ + blcc 55c00 <__bss_end__@@Base+0x356b8> │ │ │ │ andcc lr, r0, #68, 16 @ 0x440000 │ │ │ │ mvnsle r2, r0, lsl #20 │ │ │ │ svchi 0x005bf3bf │ │ │ │ stmdals r8, {r0, r1, r5, r8, fp, ip, sp, pc} │ │ │ │ tstcs r2, r8, lsl #4 │ │ │ │ - mcr 7, 5, pc, cr6, cr12, {7} @ │ │ │ │ - bmi fe78f020 <__bss_end__@@Base+0xfe76ead8> │ │ │ │ + mcr 7, 5, pc, cr8, cr12, {7} @ │ │ │ │ + bmi fe78f01c <__bss_end__@@Base+0xfe76ead4> │ │ │ │ ldrbtmi r4, [sl], #-2971 @ 0xfffff465 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, fp, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ tstphi sp, r0, asr #32 @ p-variant is OBSOLETE │ │ │ │ andlt r4, sp, r0, lsr #12 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ vmlage.f64 d9, d5, d9 │ │ │ │ movwcs lr, #22989 @ 0x59cd │ │ │ │ movwcs lr, #14813 @ 0x39dd │ │ │ │ muleq r3, r6, r8 │ │ │ │ - mrc 7, 4, APSR_nzcv, cr14, cr12, {7} │ │ │ │ + mcr 7, 5, pc, cr0, cr12, {7} @ │ │ │ │ @ instruction: 0xf0002800 │ │ │ │ cmnlt ip, r9, lsr #1 │ │ │ │ svchi 0x005bf3bf │ │ │ │ svccc 0x0000e854 │ │ │ │ stmda r4, {r0, r8, r9, fp, ip, sp}^ │ │ │ │ - bcs 12868 <_IO_stdin_used@@Base+0xa0a8> │ │ │ │ + bcs 12864 <_IO_stdin_used@@Base+0xa0a4> │ │ │ │ vsra.u64 , q12, #1 │ │ │ │ - blcs 29ddc <__bss_end__@@Base+0x9894> │ │ │ │ + blcs 29dd8 <__bss_end__@@Base+0x9890> │ │ │ │ sbcshi pc, r9, r0 │ │ │ │ ldrtmi r4, [r8], -r9, lsr #12 │ │ │ │ rscsvs pc, lr, #79 @ 0x4f │ │ │ │ - svc 0x0040f7fc │ │ │ │ + svc 0x0042f7fc │ │ │ │ @ instruction: 0x46304639 │ │ │ │ - stmda r8, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda sl, {r0, r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ orrlt r9, r3, r8, lsl #22 │ │ │ │ svchi 0x005bf3bf │ │ │ │ svccs 0x0000e853 │ │ │ │ stmda r3, {r0, r9, fp, ip, sp}^ │ │ │ │ stmdbcs r0, {r8, sp} │ │ │ │ vsra.u64 , q12, #1 │ │ │ │ stmdblt r2!, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc} │ │ │ │ andcs r9, r8, #8, 16 @ 0x80000 │ │ │ │ @ instruction: 0xf7fc2102 │ │ │ │ - blls 201a28 <__bss_end__@@Base+0x1e14e0> │ │ │ │ + blls 201a2c <__bss_end__@@Base+0x1e14e4> │ │ │ │ @ instruction: 0xf0002b00 │ │ │ │ andcs r8, r1, #135 @ 0x87 │ │ │ │ @ instruction: 0xf04f4630 │ │ │ │ @ instruction: 0xf7fc012f │ │ │ │ - stmdblt r8!, {r1, r3, r4, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdblt r8!, {r2, r3, r4, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf04f4601 │ │ │ │ ldrtmi r0, [r0], -pc, lsr #4 │ │ │ │ - mrc 7, 1, APSR_nzcv, cr14, cr12, {7} │ │ │ │ + mcr 7, 2, pc, cr0, cr12, {7} @ │ │ │ │ ldrbtmi r4, [sl], #-2674 @ 0xfffff58e │ │ │ │ vcvt.u16.f16 d7, d3, #1 │ │ │ │ subslt r8, fp, #364 @ 0x16c │ │ │ │ vsubw.s8 , q0, d1 │ │ │ │ @ instruction: 0xf10280c9 │ │ │ │ ldmibvs r3, {r2, r3, r4}^ │ │ │ │ svchi 0x005bf3bf │ │ │ │ @ instruction: 0xf14007db │ │ │ │ - blmi 1ae62f8 <__bss_end__@@Base+0x1ac5db0> │ │ │ │ + blmi 1ae62f4 <__bss_end__@@Base+0x1ac5dac> │ │ │ │ ldmibvs ip, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ rsble r2, r3, r0, lsl #24 │ │ │ │ stmdage r6, {r0, r2, r3, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ stmiavs r2!, {r0, r3, r4, r5, r7, r9, sl, lr}^ │ │ │ │ - bhi 24083c <__bss_end__@@Base+0x2202f4> │ │ │ │ + bhi 240838 <__bss_end__@@Base+0x2202f0> │ │ │ │ muleq r3, r7, r8 │ │ │ │ - mrc 7, 1, APSR_nzcv, cr2, cr12, {7} │ │ │ │ + mrc 7, 1, APSR_nzcv, cr4, cr12, {7} │ │ │ │ orrcs r6, r8, r2, lsr #17 │ │ │ │ strbmi r6, [r7], -r3, lsr #18 │ │ │ │ stmib sp, {r1, r2, r4, r6, r9, sl, fp, ip}^ │ │ │ │ eorsmi r3, r0, r0, lsl #4 │ │ │ │ - ldrbeq pc, [pc, #-0]! @ 6124 <__aeabi_atexit@plt+0x2f70> @ │ │ │ │ - blx 48842 <__bss_end__@@Base+0x282fa> │ │ │ │ + ldrbeq pc, [pc, #-0]! @ 6120 <__aeabi_atexit@plt+0x2f6c> @ │ │ │ │ + blx 4883e <__bss_end__@@Base+0x282f6> │ │ │ │ @ instruction: 0xf1063606 │ │ │ │ @ instruction: 0x4633087f │ │ │ │ ldrtmi r3, [r5], #-3329 @ 0xfffff2ff │ │ │ │ @ instruction: 0x469a4656 │ │ │ │ strmi lr, [r8, #1]! │ │ │ │ @ instruction: 0xf815d044 │ │ │ │ - ldclcs 15, cr4, [pc], #4 @ 6148 <__aeabi_atexit@plt+0x2f94> │ │ │ │ + ldclcs 15, cr4, [pc], #4 @ 6144 <__aeabi_atexit@plt+0x2f90> │ │ │ │ @ instruction: 0xf8dad03e │ │ │ │ smlawbeq r4, r0, r0, r3 │ │ │ │ strvc lr, [r3], -sp, asr #19 │ │ │ │ ldmib r3, {r0, r1, r5, sl, lr}^ │ │ │ │ stmib sp, {r0, r9, ip, sp}^ │ │ │ │ addsmi r2, r7, #8, 6 @ 0x20000000 │ │ │ │ ldmib sp, {r0, r2, r3, r5, r6, r7, r8, ip, lr, pc}^ │ │ │ │ ldm r9, {r0, r1, r8, r9, sp} │ │ │ │ @ instruction: 0xf7fc0003 │ │ │ │ - stmdacs r0, {r4, r5, r6, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r4, r5, r6, r9, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf8dad0e5 │ │ │ │ ldmdbne fp, {r7, ip, sp} │ │ │ │ ldmvs ip, {r1, r2, r5, ip, lr, pc}^ │ │ │ │ - blcs 2cd90 <__bss_end__@@Base+0xc848> │ │ │ │ + blcs 2cd8c <__bss_end__@@Base+0xc844> │ │ │ │ svcge 0x004ff43f │ │ │ │ svchi 0x005bf3bf │ │ │ │ svccs 0x0000e853 │ │ │ │ stmda r3, {r0, r9, fp, ip, sp}^ │ │ │ │ stmdbcs r0, {r8, sp} │ │ │ │ vsra.u64 , q12, #1 │ │ │ │ - bcs 29f04 <__bss_end__@@Base+0x99bc> │ │ │ │ + bcs 29f00 <__bss_end__@@Base+0x99b8> │ │ │ │ svcge 0x0041f47f │ │ │ │ andcs r9, r8, #327680 @ 0x50000 │ │ │ │ @ instruction: 0xf7fc2102 │ │ │ │ - ldr lr, [sl, -r2, ror #27]! │ │ │ │ + ldr lr, [sl, -r4, ror #27]! │ │ │ │ @ instruction: 0xf43f2c00 │ │ │ │ vcvt.u32.f32 d10, d23, #1 │ │ │ │ ldmda r4, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc}^ │ │ │ │ - blcc 55db8 <__bss_end__@@Base+0x35870> │ │ │ │ + blcc 55db4 <__bss_end__@@Base+0x3586c> │ │ │ │ andcc lr, r0, #68, 16 @ 0x440000 │ │ │ │ @ instruction: 0xf43f2a00 │ │ │ │ ldrb sl, [r6, r5, lsr #30]! │ │ │ │ ldrb r2, [r7, r0, lsl #8] │ │ │ │ ssatmi r4, #19, r3, asr #12 │ │ │ │ streq pc, [r8], r3, lsl #2 │ │ │ │ vqdmulh.s d25, d15, d0 │ │ │ │ vrshr.s64 q8, , #49 │ │ │ │ - bne ffcc6d9c <__bss_end__@@Base+0xffca6854> │ │ │ │ + bne ffcc6d98 <__bss_end__@@Base+0xffca6850> │ │ │ │ stmeq r8, {r3, r8, ip, sp, lr, pc} │ │ │ │ sbcsne r2, fp, r0, lsl #10 │ │ │ │ vqrdmulh.s d15, d3, d2 │ │ │ │ - bl fecec9f0 <__bss_end__@@Base+0xfeccc4a8> │ │ │ │ + bl fecec9ec <__bss_end__@@Base+0xfeccc4a4> │ │ │ │ @ instruction: 0xd19e1fd2 │ │ │ │ ldr r9, [sl, r0, lsl #28] │ │ │ │ - svc 0x0012f7fc │ │ │ │ + svc 0x0014f7fc │ │ │ │ @ instruction: 0xf43f2800 │ │ │ │ @ instruction: 0xf7ffaf7a │ │ │ │ stcmi 13, cr15, [r8], #-796 @ 0xfffffce4 │ │ │ │ mvnscc pc, #79 @ 0x4f │ │ │ │ strvc r4, [r3, #-1148]! @ 0xfffffb84 │ │ │ │ @ instruction: 0xf1044a26 │ │ │ │ stmdbmi r6!, {r3, r4} │ │ │ │ ldrbtmi r4, [r9], #-1146 @ 0xfffffb86 │ │ │ │ - svc 0x00d0f7fc │ │ │ │ + svc 0x00d2f7fc │ │ │ │ andseq pc, ip, r4, lsl #2 │ │ │ │ - svc 0x0032f7fc │ │ │ │ + svc 0x0034f7fc │ │ │ │ stmdals r8, {r0, r2, r5, r6, r8, r9, sl, sp, lr, pc} │ │ │ │ tstcs r2, r8, lsl #4 │ │ │ │ - ldc 7, cr15, [ip, #1008] @ 0x3f0 │ │ │ │ + ldc 7, cr15, [lr, #1008] @ 0x3f0 │ │ │ │ strmi lr, [r4], -r0, lsr #14 │ │ │ │ @ instruction: 0xf7fd4630 │ │ │ │ - bmi 7850f8 <__bss_end__@@Base+0x764bb0> │ │ │ │ + bmi 7850fc <__bss_end__@@Base+0x764bb4> │ │ │ │ ldrbtmi r4, [sl], #-2836 @ 0xfffff4ec │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, fp, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ @ instruction: 0xf7fcd00f │ │ │ │ - @ instruction: 0x4604edb6 │ │ │ │ + @ instruction: 0x4604edb8 │ │ │ │ @ instruction: 0xf7fd4638 │ │ │ │ - bmi 5c50d8 <__bss_end__@@Base+0x5a4b90> │ │ │ │ + bmi 5c50dc <__bss_end__@@Base+0x5a4b94> │ │ │ │ ldrbtmi r4, [sl], #-2828 @ 0xfffff4f4 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, fp, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ strtmi sp, [r0], -pc, ror #3 │ │ │ │ - mcr 7, 0, pc, cr4, cr12, {7} @ │ │ │ │ + mcr 7, 0, pc, cr6, cr12, {7} @ │ │ │ │ ldmdavs fp, {r8, r9, sp} │ │ │ │ - blmi 3fde78 <__bss_end__@@Base+0x3dd930> │ │ │ │ + blmi 3fde74 <__bss_end__@@Base+0x3dd92c> │ │ │ │ ldrbtmi r4, [fp], #-1540 @ 0xfffff9fc │ │ │ │ andseq pc, ip, r3, lsl #2 │ │ │ │ - ldc 7, cr15, [r2, #1008]! @ 0x3f0 │ │ │ │ + ldc 7, cr15, [r4, #1008]! @ 0x3f0 │ │ │ │ svclt 0x0000e7d4 │ │ │ │ - andeq r9, r1, r8, asr lr │ │ │ │ + andeq r9, r1, ip, asr lr │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq r2, r0, r4, lsr #17 │ │ │ │ - andeq r9, r1, r6, lsl #28 │ │ │ │ - andeq sl, r1, sl, ror r3 │ │ │ │ - andeq sl, r1, r8, asr r3 │ │ │ │ - andeq sl, r1, r4, asr #4 │ │ │ │ - strdeq r9, [r1], -r0 │ │ │ │ + andeq r2, r0, r8, lsr #17 │ │ │ │ + andeq r9, r1, sl, lsl #28 │ │ │ │ + andeq sl, r1, lr, ror r3 │ │ │ │ + andeq sl, r1, ip, asr r3 │ │ │ │ + andeq sl, r1, r8, asr #4 │ │ │ │ + strdeq r9, [r1], -r4 │ │ │ │ @ instruction: 0xfffff43b │ │ │ │ - andeq r9, r1, sl, ror #23 │ │ │ │ - andeq r9, r1, sl, asr #23 │ │ │ │ - andeq sl, r1, lr, asr #3 │ │ │ │ + andeq r9, r1, lr, ror #23 │ │ │ │ + andeq r9, r1, lr, asr #23 │ │ │ │ + ldrdeq sl, [r1], -r2 │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5d4c4 <__bss_end__@@Base+0xfeb3cf7c> │ │ │ │ + bl feb5d4c0 <__bss_end__@@Base+0xfeb3cf78> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - bmi 74a24c <__bss_end__@@Base+0x729d04> │ │ │ │ - blmi 7724dc <__bss_end__@@Base+0x751f94> │ │ │ │ + bmi 74a248 <__bss_end__@@Base+0x729d00> │ │ │ │ + blmi 7724d8 <__bss_end__@@Base+0x751f90> │ │ │ │ ldrbtmi r4, [sl], #-1540 @ 0xfffff9fc │ │ │ │ ldmpl r3, {r0, r1, r2, r3, r9, sl, lr}^ │ │ │ │ movwls r6, #6171 @ 0x181b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ tstcs r2, fp │ │ │ │ @ instruction: 0xf7fc4620 │ │ │ │ - @ instruction: 0x4620eef4 │ │ │ │ + @ instruction: 0x4620eef6 │ │ │ │ @ instruction: 0xf7fc2112 │ │ │ │ - stmiavs r0!, {r1, r2, r4, r5, r9, sl, fp, sp, lr, pc} │ │ │ │ - mcr 7, 2, pc, cr10, cr12, {7} @ │ │ │ │ + stmiavs r0!, {r3, r4, r5, r9, sl, fp, sp, lr, pc} │ │ │ │ + mcr 7, 2, pc, cr12, cr12, {7} @ │ │ │ │ @ instruction: 0x466ab9b8 │ │ │ │ @ instruction: 0x46202112 │ │ │ │ - mcr 7, 5, pc, cr4, cr12, {7} @ │ │ │ │ + mcr 7, 5, pc, cr6, cr12, {7} @ │ │ │ │ stmdacs r0, {r0, r2, r9, sl, lr} │ │ │ │ ldmdavs fp!, {r0, r1, r3, r5, r6, r7, ip, lr, pc} │ │ │ │ - bls 3273c <__bss_end__@@Base+0x121f4> │ │ │ │ - bmi 35e37c <__bss_end__@@Base+0x33de34> │ │ │ │ + bls 32738 <__bss_end__@@Base+0x121f0> │ │ │ │ + bmi 35e378 <__bss_end__@@Base+0x33de30> │ │ │ │ ldrbtmi r4, [sl], #-2827 @ 0xfffff4f5 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r1, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andlt sp, r3, r9, lsl #2 │ │ │ │ @ instruction: 0x4620bdf0 │ │ │ │ - ldc 7, cr15, [r2, #1008]! @ 0x3f0 │ │ │ │ - blcs 20420 <_IO_stdin_used@@Base+0x17c60> │ │ │ │ + ldc 7, cr15, [r4, #1008]! @ 0x3f0 │ │ │ │ + blcs 2041c <_IO_stdin_used@@Base+0x17c5c> │ │ │ │ andsvs sp, sp, sp, ror #1 │ │ │ │ @ instruction: 0xf7fce7eb │ │ │ │ - svclt 0x0000ed40 │ │ │ │ - andeq r9, r1, r6, asr fp │ │ │ │ + svclt 0x0000ed42 │ │ │ │ + andeq r9, r1, sl, asr fp │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq r9, r1, r2, lsl fp │ │ │ │ + andeq r9, r1, r6, lsl fp │ │ │ │ vst3. {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5d554 <__bss_end__@@Base+0xfeb3d00c> │ │ │ │ + bl feb5d550 <__bss_end__@@Base+0xfeb3d008> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - bmi 74a2dc <__bss_end__@@Base+0x729d94> │ │ │ │ - blmi 77256c <__bss_end__@@Base+0x752024> │ │ │ │ + bmi 74a2d8 <__bss_end__@@Base+0x729d90> │ │ │ │ + blmi 772568 <__bss_end__@@Base+0x752020> │ │ │ │ ldrbtmi r4, [sl], #-1540 @ 0xfffff9fc │ │ │ │ ldmpl r3, {r0, r1, r2, r3, r9, sl, lr}^ │ │ │ │ movwls r6, #6171 @ 0x181b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ tstcs r2, fp │ │ │ │ @ instruction: 0xf7fc4620 │ │ │ │ - strtmi lr, [r0], -ip, lsr #29 │ │ │ │ + strtmi lr, [r0], -lr, lsr #29 │ │ │ │ @ instruction: 0xf7fc2117 │ │ │ │ - stmiavs r0!, {r1, r2, r3, r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ - mcr 7, 0, pc, cr2, cr12, {7} @ │ │ │ │ + stmiavs r0!, {r4, r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + mcr 7, 0, pc, cr4, cr12, {7} @ │ │ │ │ @ instruction: 0x466ab9b8 │ │ │ │ @ instruction: 0x46202117 │ │ │ │ - mrc 7, 2, APSR_nzcv, cr12, cr12, {7} │ │ │ │ + mrc 7, 2, APSR_nzcv, cr14, cr12, {7} │ │ │ │ stmdacs r0, {r0, r2, r9, sl, lr} │ │ │ │ ldmdavs fp!, {r0, r1, r3, r5, r6, r7, ip, lr, pc} │ │ │ │ - bls 327cc <__bss_end__@@Base+0x12284> │ │ │ │ - bmi 35e40c <__bss_end__@@Base+0x33dec4> │ │ │ │ + bls 327c8 <__bss_end__@@Base+0x12280> │ │ │ │ + bmi 35e408 <__bss_end__@@Base+0x33dec0> │ │ │ │ ldrbtmi r4, [sl], #-2827 @ 0xfffff4f5 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r1, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andlt sp, r3, r9, lsl #2 │ │ │ │ @ instruction: 0x4620bdf0 │ │ │ │ - stcl 7, cr15, [sl, #-1008]! @ 0xfffffc10 │ │ │ │ - blcs 204b0 <__bss_start@@Base+0x68> │ │ │ │ + stcl 7, cr15, [ip, #-1008]! @ 0xfffffc10 │ │ │ │ + blcs 204ac <__bss_start@@Base+0x64> │ │ │ │ andsvs sp, sp, sp, ror #1 │ │ │ │ @ instruction: 0xf7fce7eb │ │ │ │ - svclt 0x0000ecf8 │ │ │ │ - andeq r9, r1, r6, asr #21 │ │ │ │ + svclt 0x0000ecfa │ │ │ │ + andeq r9, r1, sl, asr #21 │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq r9, r1, r2, lsl #21 │ │ │ │ + andeq r9, r1, r6, lsl #21 │ │ │ │ vst3.16 {d27,d29,d31}, [pc :256], r0 │ │ │ │ - bl feb5d5e4 <__bss_end__@@Base+0xfeb3d09c> │ │ │ │ + bl feb5d5e0 <__bss_end__@@Base+0xfeb3d098> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - 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@ instruction: 0x4620ee50 │ │ │ │ + @ instruction: 0x4620ee52 │ │ │ │ tstcs r9, r1, lsl #20 │ │ │ │ - stcl 7, cr15, [sl, #-1008] @ 0xfffffc10 │ │ │ │ + stcl 7, cr15, [ip, #-1008] @ 0xfffffc10 │ │ │ │ @ instruction: 0xf7fc68a0 │ │ │ │ - ldmiblt r0, {r1, r2, r5, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ - blge acc4c <__bss_end__@@Base+0x8c704> │ │ │ │ + ldmiblt r0, {r3, r5, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + blge acc48 <__bss_end__@@Base+0x8c700> │ │ │ │ strtmi r2, [r0], -r9, lsl #2 │ │ │ │ - ldc 7, cr15, [ip, #1008]! @ 0x3f0 │ │ │ │ + ldc 7, cr15, [lr, #1008]! @ 0x3f0 │ │ │ │ rscle r2, sl, r0, lsl #16 │ │ │ │ orrlt r6, fp, r3, lsr r8 │ │ │ │ - blvc c1ad0 <__bss_end__@@Base+0xa1588> │ │ │ │ - blvs 41f38 <__bss_end__@@Base+0x219f0> │ │ │ │ - blvc 1c1d00 <__bss_end__@@Base+0x1a17b8> │ │ │ │ - blvc 41a74 <__bss_end__@@Base+0x2152c> │ │ │ │ + blvc c1acc <__bss_end__@@Base+0xa1584> │ │ │ │ + blvs 41f34 <__bss_end__@@Base+0x219ec> │ │ │ │ + blvc 1c1cfc <__bss_end__@@Base+0x1a17b4> │ │ │ │ + blvc 41a70 <__bss_end__@@Base+0x21528> │ │ │ │ strtmi lr, [r0], -r8 │ │ │ │ - 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strtmi lr, [r0], -ip, ror #27 │ │ │ │ + strtmi lr, [r0], -lr, ror #27 │ │ │ │ tstcs fp, r1, lsl #20 │ │ │ │ - stcl 7, cr15, [r6], #1008 @ 0x3f0 │ │ │ │ + stcl 7, cr15, [r8], #1008 @ 0x3f0 │ │ │ │ @ instruction: 0xf7fc68a0 │ │ │ │ - ldmdblt r0!, {r1, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ - blge acd14 <__bss_end__@@Base+0x8c7cc> │ │ │ │ + ldmdblt r0!, {r2, r6, r8, sl, fp, sp, lr, pc}^ │ │ │ │ + blge acd10 <__bss_end__@@Base+0x8c7c8> │ │ │ │ strtmi r2, [r0], -fp, lsl #2 │ │ │ │ - ldcl 7, cr15, [r8, #-1008] @ 0xfffffc10 │ │ │ │ + ldcl 7, cr15, [sl, #-1008] @ 0xfffffc10 │ │ │ │ rscle r2, sl, r0, lsl #16 │ │ │ │ cmnlt fp, r3, lsr r8 │ │ │ │ ldrdeq lr, [r2, -sp] │ │ │ │ smlabteq r0, r3, r9, lr │ │ │ │ strtmi lr, [r0], -r8 │ │ │ │ - ldc 7, cr15, [r2], #1008 @ 0x3f0 │ │ │ │ + ldc 7, cr15, [r4], #1008 @ 0x3f0 │ │ │ │ tstlt fp, r3, lsr r8 │ │ │ │ mrscs r2, (UNDEF: 0) │ │ │ │ smlabteq r0, r3, r9, lr │ │ │ │ - blmi 1d8d60 <__bss_end__@@Base+0x1b8818> │ │ │ │ + blmi 1d8d5c <__bss_end__@@Base+0x1b8814> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - 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strtmi lr, [r0], -r0, lsr #27 │ │ │ │ + strtmi lr, [r0], -r2, lsr #27 │ │ │ │ @ instruction: 0xf7fc210c │ │ │ │ - stmiavs r0!, {r1, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ - ldcl 7, cr15, [r6], #1008 @ 0x3f0 │ │ │ │ - bge 75204 <__bss_end__@@Base+0x54cbc> │ │ │ │ + stmiavs r0!, {r2, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + ldcl 7, cr15, [r8], #1008 @ 0x3f0 │ │ │ │ + bge 75200 <__bss_end__@@Base+0x54cb8> │ │ │ │ strtmi r2, [r0], -ip, lsl #2 │ │ │ │ - ldcl 7, cr15, [r0, #-1008] @ 0xfffffc10 │ │ │ │ + ldcl 7, cr15, [r2, #-1008] @ 0xfffffc10 │ │ │ │ rscle r2, ip, r0, lsl #16 │ │ │ │ tstcs r4, ip │ │ │ │ @ instruction: 0xf7fc4620 │ │ │ │ - strtmi lr, [r0], -ip, lsl #27 │ │ │ │ + strtmi lr, [r0], -lr, lsl #27 │ │ │ │ tstcs sp, r1, lsl #20 │ │ │ │ - stc 7, cr15, [r6], {252} @ 0xfc │ │ │ │ + stc 7, cr15, [r8], {252} @ 0xfc │ │ │ │ @ instruction: 0xf7fc68a0 │ │ │ │ - ldmdblt r0!, {r1, r5, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ - blge acdd4 <__bss_end__@@Base+0x8c88c> │ │ │ │ + ldmdblt r0!, {r2, r5, r6, r7, sl, fp, sp, lr, pc}^ │ │ │ │ + blge acdd0 <__bss_end__@@Base+0x8c888> │ │ │ │ strtmi r2, [r0], -sp, lsl #2 │ │ │ │ - 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andeq r9, r1, r0, lsl #19 │ │ │ │ - andeq r9, r1, ip, ror #18 │ │ │ │ + strtmi lr, [r0], -r4, lsl #19 │ │ │ │ + stmib r8, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + andeq r9, r1, r4, asr #19 │ │ │ │ + @ instruction: 0x000199b2 │ │ │ │ + andeq r1, r0, r8, lsl #28 │ │ │ │ + andeq r9, r1, r4, lsl #19 │ │ │ │ + andeq r9, r1, r0, ror r9 │ │ │ │ vst3.8 {d27,d29,d31}, [pc :64], r0 │ │ │ │ - bl feb5dd0c <__bss_end__@@Base+0xfeb3d7c4> │ │ │ │ + bl feb5dd08 <__bss_end__@@Base+0xfeb3d7c0> │ │ │ │ @ instruction: 0xf8cc0c0c │ │ │ │ - blmi 68aab4 <__bss_end__@@Base+0x66a56c> │ │ │ │ + blmi 68aab0 <__bss_end__@@Base+0x66a568> │ │ │ │ strmi fp, [sl], -r4, lsl #1 │ │ │ │ @ instruction: 0xf103447b │ │ │ │ cdpvs 0, 9, cr0, cr11, cr8, {3} │ │ │ │ svchi 0x005bf3bf │ │ │ │ strle r0, [r5, #-2011] @ 0xfffff825 │ │ │ │ ldrbtmi r4, [fp], #-2837 @ 0xfffff4eb │ │ │ │ @ instruction: 0x60136edb │ │ │ │ ldclt 0, cr11, [r0, #-16] │ │ │ │ @ instruction: 0xf7fc9101 │ │ │ │ - bls 81504 <__bss_end__@@Base+0x60fbc> │ │ │ │ + bls 81508 <__bss_end__@@Base+0x60fc0> │ │ │ │ rscsle r2, r3, r0, lsl #16 │ │ │ │ tstcs r0, r0, lsl fp │ │ │ │ stmib sp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - bl 34b754 <__bss_end__@@Base+0x32b20c> │ │ │ │ + bl 34b750 <__bss_end__@@Base+0x32b208> │ │ │ │ ldmdb r3, {r0, r8, r9} │ │ │ │ @ instruction: 0xf7fc0003 │ │ │ │ - blmi 3417d0 <__bss_end__@@Base+0x321288> │ │ │ │ + blmi 3417d4 <__bss_end__@@Base+0x32128c> │ │ │ │ @ instruction: 0x66d8447b │ │ │ │ rsbeq pc, r8, r3, lsl #2 │ │ │ │ - b fe4c4b54 <__bss_end__@@Base+0xfe4a460c> │ │ │ │ + b fe544b50 <__bss_end__@@Base+0xfe524608> │ │ │ │ ldrb r9, [pc, r1, lsl #20] │ │ │ │ strmi r4, [r4], -r8, lsl #22 │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fc0068 │ │ │ │ - @ instruction: 0x4620e93c │ │ │ │ - stmib r0, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - andeq r9, r1, r4, lsr r9 │ │ │ │ - andeq r9, r1, r2, lsr #18 │ │ │ │ - andeq r1, r0, r8, ror sp │ │ │ │ - strdeq r9, [r1], -r4 │ │ │ │ - andeq r9, r1, r0, ror #17 │ │ │ │ + @ instruction: 0x4620e93e │ │ │ │ + stmib r2, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + andeq r9, r1, r8, lsr r9 │ │ │ │ + andeq r9, r1, r6, lsr #18 │ │ │ │ + andeq r1, r0, ip, ror sp │ │ │ │ + strdeq r9, [r1], -r8 │ │ │ │ + andeq r9, r1, r4, ror #17 │ │ │ │ mvnsmi lr, sp, lsr #18 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00d0f8cc │ │ │ │ - bmi 1732dbc <__bss_end__@@Base+0x1712874> │ │ │ │ + bmi 1732db8 <__bss_end__@@Base+0x1712870> │ │ │ │ strcs r2, [r0, -r0, lsl #6] │ │ │ │ @ instruction: 0x2600447a │ │ │ │ strmi r9, [r4], -r4, lsl #6 │ │ │ │ pkhtbmi r4, r8, r9, asr #22 │ │ │ │ strvs lr, [r2, -sp, asr #19] │ │ │ │ ldmpl r3, {r0, r8, r9, sl, fp, sp, pc}^ │ │ │ │ movwls r6, #22555 @ 0x581b │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ tstcs r2, sp │ │ │ │ stcge 6, cr4, [r2, #-128] @ 0xffffff80 │ │ │ │ - b fe044bc0 <__bss_end__@@Base+0xfe024678> │ │ │ │ + b fe0c4bbc <__bss_end__@@Base+0xfe0a4674> │ │ │ │ @ instruction: 0x46202113 │ │ │ │ - ldm lr, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmia r0!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fc68a0 │ │ │ │ - stmdacs r0, {r3, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r3, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ ldrtmi sp, [sl], -lr, asr #2 │ │ │ │ @ instruction: 0x46202113 │ │ │ │ @ instruction: 0xf7fcad02 │ │ │ │ - stmdacs r0, {r1, r2, r4, r6, r7, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r3, r4, r6, r7, fp, sp, lr, pc} │ │ │ │ stcge 0, cr13, [r2, #-932] @ 0xfffffc5c │ │ │ │ tstcs r4, sp │ │ │ │ @ instruction: 0xf7fc4620 │ │ │ │ - bls 815a8 <__bss_end__@@Base+0x61060> │ │ │ │ + bls 815ac <__bss_end__@@Base+0x61064> │ │ │ │ @ instruction: 0x46202114 │ │ │ │ - stmdb r4!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb r6!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7fc68a0 │ │ │ │ - stmdacs r0, {r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - bls 7b168 <__bss_end__@@Base+0x5ac20> │ │ │ │ + stmdacs r0, {r1, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ + bls 7b164 <__bss_end__@@Base+0x5ac1c> │ │ │ │ tstcs r4, fp, lsr #12 │ │ │ │ @ instruction: 0xf7fc4620 │ │ │ │ - stmdacs r0, {r1, r2, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r3, r4, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ @ instruction: 0xf8d8d0e9 │ │ │ │ stmdbls r2, {sp} │ │ │ │ cmplt r2, fp, lsl #12 │ │ │ │ ldmib r2, {r0, r1, sl, fp, ip, pc}^ │ │ │ │ stmib r2, {ip, sp}^ │ │ │ │ ldmvs r1, {sl, ip} │ │ │ │ addsvs r9, r4, r4, lsl #24 │ │ │ │ @@ -3748,218 +3747,218 @@ │ │ │ │ svccs 0x0000e853 │ │ │ │ stmda r3, {r0, r9, fp, ip, sp}^ │ │ │ │ stmdbcs r0, {r8, sp} │ │ │ │ vsra.u64 , q12, #1 │ │ │ │ stmdblt r2!, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc} │ │ │ │ andcs r9, r8, #131072 @ 0x20000 │ │ │ │ @ instruction: 0xf7fc2102 │ │ │ │ - bmi b80e70 <__bss_end__@@Base+0xb60928> │ │ │ │ + bmi b80e74 <__bss_end__@@Base+0xb6092c> │ │ │ │ ldrbtmi r4, [sl], #-2859 @ 0xfffff4d5 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r5, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ andlt sp, r6, r7, asr #2 │ │ │ │ ldrhhi lr, [r0, #141]! @ 0x8d │ │ │ │ stcge 6, cr4, [r2, #-128] @ 0xffffff80 │ │ │ │ - stmdb r6, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r8, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ ldmdavs r8, {r0, r1, r3, r5, r7, r8, ip, sp, pc} │ │ │ │ stmib r3, {r9, sp}^ │ │ │ │ addsvs r2, sl, r0, lsl #4 │ │ │ │ vsra.u32 , q12, #1 │ │ │ │ ldmda r0, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc}^ │ │ │ │ - blcc 568a4 <__bss_end__@@Base+0x3635c> │ │ │ │ + blcc 568a0 <__bss_end__@@Base+0x36358> │ │ │ │ andcc lr, r0, #64, 16 @ 0x400000 │ │ │ │ mvnsle r2, r0, lsl #20 │ │ │ │ svchi 0x005bf3bf │ │ │ │ andcs fp, r8, #442368 @ 0x6c000 │ │ │ │ @ instruction: 0xf7fc2102 │ │ │ │ - blls c0e1c <__bss_end__@@Base+0xa08d4> │ │ │ │ + blls c0e20 <__bss_end__@@Base+0xa08d8> │ │ │ │ strtmi lr, [r0], -r1, asr #15 │ │ │ │ - stmia r8!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmia sl!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ rscsle r2, r6, r0, lsl #22 │ │ │ │ andcs r6, r0, #24, 16 @ 0x180000 │ │ │ │ andcs lr, r0, #3194880 @ 0x30c000 │ │ │ │ stmdacs r0, {r1, r3, r4, r7, sp, lr} │ │ │ │ vmla.i , , d31[0] │ │ │ │ ldmda r0, {r0, r1, r3, r4, r6, r8, r9, sl, fp, pc}^ │ │ │ │ - blcc 568e4 <__bss_end__@@Base+0x3639c> │ │ │ │ + blcc 568e0 <__bss_end__@@Base+0x36398> │ │ │ │ andcc lr, r0, #64, 16 @ 0x400000 │ │ │ │ sbcsle r2, pc, r0, lsl #20 │ │ │ │ @ instruction: 0x4604e7f7 │ │ │ │ @ instruction: 0xf7fc4628 │ │ │ │ - bmi 2c663c <__bss_end__@@Base+0x2a60f4> │ │ │ │ + bmi 2c6640 <__bss_end__@@Base+0x2a60f8> │ │ │ │ ldrbtmi r4, [sl], #-2823 @ 0xfffff4f9 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r5, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ @ instruction: 0xf7fcd001 │ │ │ │ - @ instruction: 0x4620e858 │ │ │ │ - ldm r4!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - andeq r9, r1, r0, lsl #5 │ │ │ │ + @ instruction: 0x4620e85a │ │ │ │ + ldm r6!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + andeq r9, r1, r4, lsl #5 │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - @ instruction: 0x000191be │ │ │ │ - andeq r9, r1, lr, lsr #2 │ │ │ │ + andeq r9, r1, r2, asr #3 │ │ │ │ + andeq r9, r1, r2, lsr r1 │ │ │ │ mvnsmi lr, #737280 @ 0xb4000 │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x00c0f8cc │ │ │ │ addlt r4, r9, r7, ror #22 │ │ │ │ strmi r4, [r4], -r7, ror #20 │ │ │ │ stclmi 4, cr4, [r7, #-492]! @ 0xfffffe14 │ │ │ │ - blmi 19d87a8 <__bss_end__@@Base+0x19b8260> │ │ │ │ + blmi 19d87a4 <__bss_end__@@Base+0x19b825c> │ │ │ │ svcmi 0x0067447a │ │ │ │ sxtab16mi r4, r8, sp, ror #8 │ │ │ │ - ldrbtmi r3, [pc], #-1392 @ 6d50 <__aeabi_atexit@plt+0x3b9c> │ │ │ │ + ldrbtmi r3, [pc], #-1392 @ 6d4c <__aeabi_atexit@plt+0x3b98> │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9307 │ │ │ │ ands r0, r6, r0, lsl #6 │ │ │ │ tstlt r8, r8, ror pc │ │ │ │ - blcs 21170 <__bss_end__@@Base+0xc28> │ │ │ │ + blcs 2116c <__bss_end__@@Base+0xc24> │ │ │ │ @ instruction: 0x4798d036 │ │ │ │ ldrsbgt pc, [ip, #-143]! @ 0xffffff71 @ │ │ │ │ - blmi 17d8578 <__bss_end__@@Base+0x17b8030> │ │ │ │ + blmi 17d8574 <__bss_end__@@Base+0x17b802c> │ │ │ │ ldrbtmi r4, [ip], #1568 @ 0x620 │ │ │ │ ldrbtmi r2, [fp], #-278 @ 0xfffffeea │ │ │ │ andgt pc, r0, sp, asr #17 │ │ │ │ - ldmdb lr, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r0!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fc68a0 │ │ │ │ - stmdacs r0, {r2, r8, fp, sp, lr, pc} │ │ │ │ - bge 13b298 <__bss_end__@@Base+0x11ad50> │ │ │ │ + stmdacs r0, {r1, r2, r8, fp, sp, lr, pc} │ │ │ │ + bge 13b294 <__bss_end__@@Base+0x11ad4c> │ │ │ │ @ instruction: 0x46202116 │ │ │ │ - stmib r8, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib sl, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ tstcs r4, r0, lsl #22 │ │ │ │ @ instruction: 0xf7fc4620 │ │ │ │ - stmdavs fp!, {r1, r3, r4, r7, r8, fp, sp, lr, pc} │ │ │ │ + stmdavs fp!, {r2, r3, r4, r7, r8, fp, sp, lr, pc} │ │ │ │ svchi 0x005bf3bf │ │ │ │ ldrble r0, [r9], #2010 @ 0x7da │ │ │ │ @ instruction: 0xf7fc4628 │ │ │ │ - stmdacs r0, {r3, r4, r5, r8, fp, sp, lr, pc} │ │ │ │ - blmi 13fb104 <__bss_end__@@Base+0x13dabbc> │ │ │ │ + stmdacs r0, {r1, r3, r4, r5, r8, fp, sp, lr, pc} │ │ │ │ + blmi 13fb100 <__bss_end__@@Base+0x13dabb8> │ │ │ │ andls r2, r5, #-1342177280 @ 0xb0000000 │ │ │ │ movwls r4, #25723 @ 0x647b │ │ │ │ ldrdeq lr, [r5, -sp] │ │ │ │ - stmib r6!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib r8!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [fp], #-2891 @ 0xfffff4b5 │ │ │ │ @ instruction: 0xf1036758 │ │ │ │ @ instruction: 0xf7fc0070 │ │ │ │ - @ instruction: 0xe7c3e95c │ │ │ │ + @ instruction: 0xe7c3e95e │ │ │ │ bfi r4, r8, (invalid: 12:7) │ │ │ │ ldrdne pc, [r0], -r8 │ │ │ │ - blmi 11b3364 <__bss_end__@@Base+0x1192e1c> │ │ │ │ + blmi 11b3360 <__bss_end__@@Base+0x1192e18> │ │ │ │ @ instruction: 0xf859a805 │ │ │ │ movwls r3, #20483 @ 0x5003 │ │ │ │ - ldmda lr!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stm r0, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrdne pc, [r0], -r8 │ │ │ │ stmdage r5, {r2, r9, fp, sp, pc} │ │ │ │ - ldmda r4, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ - blmi e596fc <__bss_end__@@Base+0xe391b4> │ │ │ │ + ldmda r6, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + blmi e596f8 <__bss_end__@@Base+0xe391b0> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 1e0e6c <__bss_end__@@Base+0x1c0924> │ │ │ │ + blls 1e0e68 <__bss_end__@@Base+0x1c0920> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ mrsle r0, (UNDEF: 125) │ │ │ │ pop {r0, r3, ip, sp, pc} │ │ │ │ @ instruction: 0x462083f0 │ │ │ │ - ldmda lr!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda r0, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -r8 │ │ │ │ rscle r2, fp, r0, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2871 @ 0xfffff4c9 │ │ │ │ rsbseq pc, r8, r3, lsl #2 │ │ │ │ @ instruction: 0xf3bf6f9b │ │ │ │ @ instruction: 0x07db8f5b │ │ │ │ - blge 17c278 <__bss_end__@@Base+0x15bd30> │ │ │ │ + blge 17c274 <__bss_end__@@Base+0x15bd2c> │ │ │ │ @ instruction: 0x46184a33 │ │ │ │ ldrdne pc, [r0], -r8 │ │ │ │ movwls r4, #13434 @ 0x347a │ │ │ │ andls r6, r5, #840 @ 0x348 │ │ │ │ - ldmda r0, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r2, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrdne pc, [r0], -r8 │ │ │ │ stmdals r3, {r9, sp} │ │ │ │ - stmda r6!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda r8!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fce7d0 │ │ │ │ - stmdacs r0, {r1, r5, r6, r7, fp, sp, lr, pc} │ │ │ │ - bmi abb204 <__bss_end__@@Base+0xa9acbc> │ │ │ │ + stmdacs r0, {r2, r5, r6, r7, fp, sp, lr, pc} │ │ │ │ + bmi abb200 <__bss_end__@@Base+0xa9acb8> │ │ │ │ tstcs r6, r5, lsl #22 │ │ │ │ ldrbtmi r9, [sl], #-771 @ 0xfffffcfd │ │ │ │ andne lr, r5, #3358720 @ 0x334000 │ │ │ │ muleq r3, r3, r8 │ │ │ │ - stmib lr, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib r0, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldrbtmi r4, [sl], #-2597 @ 0xfffff5db │ │ │ │ @ instruction: 0xf10267d0 │ │ │ │ @ instruction: 0xf7fc0078 │ │ │ │ - blls 101294 <__bss_end__@@Base+0xe0d4c> │ │ │ │ - blmi 8c0de0 <__bss_end__@@Base+0x8a0898> │ │ │ │ + blls 101298 <__bss_end__@@Base+0xe0d50> │ │ │ │ + blmi 8c0ddc <__bss_end__@@Base+0x8a0894> │ │ │ │ ldrbtmi r4, [fp], #-1540 @ 0xfffff9fc │ │ │ │ rsbseq pc, r8, r3, lsl #2 │ │ │ │ - svc 0x00acf7fb │ │ │ │ - blmi 499714 <__bss_end__@@Base+0x4791cc> │ │ │ │ + svc 0x00aef7fb │ │ │ │ + blmi 499710 <__bss_end__@@Base+0x4791c8> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 1e0f08 <__bss_end__@@Base+0x1c09c0> │ │ │ │ + blls 1e0f04 <__bss_end__@@Base+0x1c09bc> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ andsle r0, r2, r0, lsl #6 │ │ │ │ - svc 0x0088f7fb │ │ │ │ + svc 0x008af7fb │ │ │ │ @ instruction: 0x46044b1a │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fb0070 │ │ │ │ - bmi 642d24 <__bss_end__@@Base+0x6227dc> │ │ │ │ + bmi 642d28 <__bss_end__@@Base+0x6227e0> │ │ │ │ ldrbtmi r4, [sl], #-2824 @ 0xfffff4f8 │ │ │ │ ldmdavs sl, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ subsmi r9, sl, r7, lsl #22 │ │ │ │ movweq pc, #79 @ 0x4f @ │ │ │ │ strtmi sp, [r0], -ip, ror #3 │ │ │ │ - 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svc 0x0006f7fb │ │ │ │ + svc 0x0008f7fb │ │ │ │ @ instruction: 0xf7fb9801 │ │ │ │ - subs lr, fp, r4, lsl #30 │ │ │ │ + subs lr, fp, r6, lsl #30 │ │ │ │ strtmi r2, [r0], -r4, lsl #2 │ │ │ │ - ldmda r6, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r8, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ tstcs r9, r9, lsl #20 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stmiavs r0!, {r1, r4, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ - svc 0x00acf7fb │ │ │ │ + stmiavs r0!, {r2, r4, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + svc 0x00aef7fb │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ tstcs r9, sl, lsr #1 │ │ │ │ @ instruction: 0xf7fc4620 │ │ │ │ - stcls 8, cr14, [r1, #-72] @ 0xffffffb8 │ │ │ │ + stcls 8, cr14, [r1, #-80] @ 0xffffffb0 │ │ │ │ andcs r4, r0, #1048576 @ 0x100000 │ │ │ │ @ instruction: 0xf7fc4628 │ │ │ │ - @ instruction: 0x462ee890 │ │ │ │ + @ instruction: 0x462ee892 │ │ │ │ ldrdhi pc, [r8], -sp │ │ │ │ cdpeq 1, 7, cr15, cr8, cr13, {0} │ │ │ │ strbmi r9, [r4], r2, lsr #14 │ │ │ │ ldrvc lr, [lr, -sp, asr #19] │ │ │ │ stmib sp, {r0, r1, r2, r3, r9, sl, fp, lr, pc}^ │ │ │ │ stmia ip!, {r5, r8, r9, sl, ip, sp, lr} │ │ │ │ movwcs r0, #8207 @ 0x200f │ │ │ │ @ instruction: 0xf88d9a03 │ │ │ │ strtmi r3, [fp], r8, lsl #1 │ │ │ │ stmdacs r4, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - beq 1e434b0 <__bss_end__@@Base+0x1e22f68> │ │ │ │ + beq 1e434ac <__bss_end__@@Base+0x1e22f64> │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ ldrmi r9, [r5], -r1, lsl #10 │ │ │ │ @ instruction: 0x000fe8be │ │ │ │ andshi pc, r8, sp, asr #17 │ │ │ │ andeq lr, pc, fp, lsr #17 │ │ │ │ ldmdaeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -lr │ │ │ │ - stcgt 0, cr6, [pc, #-204] @ 6fd4 <__aeabi_atexit@plt+0x3e20> │ │ │ │ + stcgt 0, cr6, [pc, #-204] @ 6fd0 <__aeabi_atexit@plt+0x3e1c> │ │ │ │ andeq lr, pc, sl, lsr #17 │ │ │ │ ldm r5, {r0, r2, r9, sl, fp, ip, pc} │ │ │ │ stm lr, {r0, r1} │ │ │ │ strmi r0, [r6], r3 │ │ │ │ cdpls 14, 0, cr12, cr4, cr15, {0} │ │ │ │ @ instruction: 0xf8dcc60f │ │ │ │ eorvs r1, r9, r0 │ │ │ │ ldm r8!, {r1, r2, r8, sl, fp, ip, pc} │ │ │ │ - strgt r0, [pc, #-15] @ 70b5 <__aeabi_atexit@plt+0x3f01> │ │ │ │ + strgt r0, [pc, #-15] @ 70b1 <__aeabi_atexit@plt+0x3efd> │ │ │ │ @ instruction: 0xf8cc9802 │ │ │ │ @ instruction: 0xf7fbe000 │ │ │ │ - stmdals r1, {r1, r3, r5, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ - mcr 7, 5, pc, cr6, cr11, {7} @ │ │ │ │ + stmdals r1, {r2, r3, r5, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + mcr 7, 5, pc, cr8, cr11, {7} @ │ │ │ │ stcls 8, cr9, [r9, #-12] │ │ │ │ - stmda lr, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r0, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ strtmi r4, [sl], -r3, lsl #12 │ │ │ │ @ instruction: 0x46202119 │ │ │ │ - svc 0x0070f7fb │ │ │ │ + svc 0x0072f7fb │ │ │ │ addsle r2, r7, r0, lsl #16 │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ - blls 433820 <__bss_end__@@Base+0x4132d8> │ │ │ │ + blls 43381c <__bss_end__@@Base+0x4132d4> │ │ │ │ movweq pc, #12339 @ 0x3033 @ │ │ │ │ strtmi sp, [r0], -r2, lsl #2 │ │ │ │ - mcr 7, 6, pc, cr10, cr11, {7} @ │ │ │ │ + mcr 7, 6, pc, cr12, cr11, {7} @ │ │ │ │ @ instruction: 0xf7fb9803 │ │ │ │ - blls 202ea8 <__bss_end__@@Base+0x1e2960> │ │ │ │ + blls 202eac <__bss_end__@@Base+0x1e2964> │ │ │ │ stmdage sl, {r1, r3, ip, pc} │ │ │ │ @ instruction: 0xf7fb6819 │ │ │ │ - blls 202cc4 <__bss_end__@@Base+0x1e277c> │ │ │ │ + blls 202cc8 <__bss_end__@@Base+0x1e2780> │ │ │ │ ldmdavs sp, {r0, r1, fp, ip, pc} │ │ │ │ - stmda lr!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmda r0!, {r2, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ strtmi r4, [r9], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7fba80a │ │ │ │ - stmdals r3, {r1, r2, r3, r4, r5, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ - mrc 7, 3, APSR_nzcv, cr10, cr11, {7} │ │ │ │ - blmi 1419a74 <__bss_end__@@Base+0x13f952c> │ │ │ │ + stmdals r3, {r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + mrc 7, 3, APSR_nzcv, cr12, cr11, {7} │ │ │ │ + blmi 1419a70 <__bss_end__@@Base+0x13f9528> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 9611a0 <__bss_end__@@Base+0x940c58> │ │ │ │ + blls 96119c <__bss_end__@@Base+0x940c54> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ eorlt r8, r7, r5, lsl #1 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - blls 202be0 <__bss_end__@@Base+0x1e2698> │ │ │ │ - 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blmi d321dc <__bss_end__@@Base+0xd11c94> │ │ │ │ - bls 1d8a38 <__bss_end__@@Base+0x1b84f0> │ │ │ │ + blmi d321d8 <__bss_end__@@Base+0xd11c90> │ │ │ │ + bls 1d8a34 <__bss_end__@@Base+0x1b84ec> │ │ │ │ ldmdavs r1, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldrdcc pc, [ip], r3 │ │ │ │ @ instruction: 0xf7fb930a │ │ │ │ - bfi lr, r2, (invalid: 29:27) │ │ │ │ - svc 0x0028f7fb │ │ │ │ + bfi lr, r4, (invalid: 29:27) │ │ │ │ + svc 0x002af7fb │ │ │ │ sbcle r2, ip, r0, lsl #16 │ │ │ │ @ instruction: 0xac0a4b2d │ │ │ │ ldrbtmi r2, [fp], #-528 @ 0xfffffdf0 │ │ │ │ movwcs lr, #43469 @ 0xa9cd │ │ │ │ muleq r3, r4, r8 │ │ │ │ - svc 0x00d6f7fb │ │ │ │ + svc 0x00d8f7fb │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ addeq pc, r4, r3, asr #17 │ │ │ │ addeq pc, r0, r3, lsl #2 │ │ │ │ - svc 0x004af7fb │ │ │ │ + svc 0x004cf7fb │ │ │ │ @ instruction: 0xf7fbe7ba │ │ │ │ - stmdacs r0, {r1, r4, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ - blmi 93b560 <__bss_end__@@Base+0x91b018> │ │ │ │ + stmdacs r0, {r2, r4, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + blmi 93b55c <__bss_end__@@Base+0x91b014> │ │ │ │ andscs sl, r0, #2560 @ 0xa00 │ │ │ │ stmib sp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldm r4, {r1, r3, r8, r9, sp} │ │ │ │ @ instruction: 0xf7fb0003 │ │ │ │ - blmi 843114 <__bss_end__@@Base+0x822bcc> │ │ │ │ + blmi 843118 <__bss_end__@@Base+0x822bd0> │ │ │ │ @ instruction: 0xf8c3447b │ │ │ │ @ instruction: 0xf103008c │ │ │ │ @ instruction: 0xf7fb0088 │ │ │ │ - @ instruction: 0xe7c6ef34 │ │ │ │ + @ instruction: 0xe7c6ef36 │ │ │ │ @ instruction: 0x46044b1c │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fb0080 │ │ │ │ - stmdals r3, {r1, r2, r3, r4, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ - ldcl 7, cr15, [r4, #1004]! @ 0x3ec │ │ │ │ - blmi 359a9c <__bss_end__@@Base+0x339554> │ │ │ │ + stmdals r3, {r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + ldcl 7, cr15, [r6, #1004]! @ 0x3ec │ │ │ │ + blmi 359a98 <__bss_end__@@Base+0x339550> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 9612ac <__bss_end__@@Base+0x940d64> │ │ │ │ + blls 9612a8 <__bss_end__@@Base+0x940d60> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ andle r0, fp, r0, lsl #6 │ │ │ │ - ldc 7, cr15, [r6, #1004]! @ 0x3ec │ │ │ │ + ldc 7, cr15, [r8, #1004]! @ 0x3ec │ │ │ │ strb r4, [lr, r4, lsl #12]! │ │ │ │ @ instruction: 0x46044b12 │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fb0088 │ │ │ │ - strb lr, [r6, r6, asr #27]! │ │ │ │ + strb lr, [r6, r8, asr #27]! │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - svclt 0x0000ee0a │ │ │ │ - andeq r8, r1, r2, ror #29 │ │ │ │ + svclt 0x0000ee0c │ │ │ │ + andeq r8, r1, r6, ror #29 │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - strdeq r8, [r1], -r8 @ │ │ │ │ - strdeq r9, [r1], -r4 │ │ │ │ - ldrdeq r9, [r1], -sl │ │ │ │ - andeq r9, r1, lr, lsr #5 │ │ │ │ - muleq r1, r4, r2 │ │ │ │ - andeq r1, r0, r6, ror #13 │ │ │ │ - andeq r9, r1, r6, ror #4 │ │ │ │ - @ instruction: 0x000016b8 │ │ │ │ - andeq r9, r1, r8, lsr r2 │ │ │ │ - andeq r9, r1, r4, lsr #4 │ │ │ │ - andeq r8, r1, ip, ror #23 │ │ │ │ - strdeq r9, [r1], -r4 │ │ │ │ + strdeq r8, [r1], -ip │ │ │ │ + strdeq r9, [r1], -r8 │ │ │ │ + ldrdeq r9, [r1], -lr │ │ │ │ + @ instruction: 0x000192b2 │ │ │ │ + muleq r1, r8, r2 │ │ │ │ + andeq r1, r0, sl, ror #13 │ │ │ │ + andeq r9, r1, sl, ror #4 │ │ │ │ + @ instruction: 0x000016bc │ │ │ │ + andeq r9, r1, ip, lsr r2 │ │ │ │ + andeq r9, r1, r8, lsr #4 │ │ │ │ + strdeq r8, [r1], -r0 │ │ │ │ + strdeq r9, [r1], -r8 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0040f8cc │ │ │ │ movwcs fp, #167 @ 0xa7 │ │ │ │ andcs sl, r2, #12, 26 @ 0x300 │ │ │ │ movwls r4, #50692 @ 0xc604 │ │ │ │ movwcc lr, #6597 @ 0x19c5 │ │ │ │ - bmi ff2abb08 <__bss_end__@@Base+0xff28b5c0> │ │ │ │ + bmi ff2abb04 <__bss_end__@@Base+0xff28b5bc> │ │ │ │ ldrbtmi r4, [sl], #-3018 @ 0xfffff436 │ │ │ │ tstls r7, r3, lsl #10 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9325 │ │ │ │ and r0, sp, r0, lsl #6 │ │ │ │ strtmi r2, [r0], -r2, lsl #2 │ │ │ │ - mrc 7, 7, APSR_nzcv, cr6, cr11, {7} │ │ │ │ + mrc 7, 7, APSR_nzcv, cr8, cr11, {7} │ │ │ │ @ instruction: 0x4620211a │ │ │ │ - ldc 7, cr15, [r4, #-1004] @ 0xfffffc14 │ │ │ │ + ldc 7, cr15, [r6, #-1004] @ 0xfffffc14 │ │ │ │ @ instruction: 0xf7fb68a0 │ │ │ │ - stmdacs r0, {r1, r2, r3, r6, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r4, r6, r9, sl, fp, sp, lr, pc} │ │ │ │ rschi pc, sl, r0, asr #32 │ │ │ │ tstcs sl, r9, lsl #20 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stmdacs r0, {r2, r3, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r3, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ tstcs fp, sl, ror #1 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - strmi lr, [r1], -ip, lsr #29 │ │ │ │ + strmi lr, [r1], -lr, lsr #29 │ │ │ │ ldmdage r2, {r9, sp} │ │ │ │ - svc 0x002af7fb │ │ │ │ + svc 0x002cf7fb │ │ │ │ smladcs r0, r2, sl, sl │ │ │ │ @ instruction: 0x97224616 │ │ │ │ movwcs r9, #8705 @ 0x2201 │ │ │ │ @ instruction: 0xf88d4694 │ │ │ │ cdpgt 0, 0, cr3, cr15, cr8, {4} │ │ │ │ stmdaeq r0!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x971ead1e │ │ │ │ @@ -4203,213 +4202,213 @@ │ │ │ │ strgt r0, [pc], -pc │ │ │ │ @ instruction: 0xf8d84656 │ │ │ │ movwls r3, #20480 @ 0x5000 │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ cdpgt 6, 0, cr4, cr15, cr5, {0} │ │ │ │ stmia fp!, {r1, r2, r3, r4, r9, sl, fp, sp, pc} │ │ │ │ - blls 1473c0 <__bss_end__@@Base+0x126e78> │ │ │ │ + blls 1473bc <__bss_end__@@Base+0x126e74> │ │ │ │ andcc pc, r0, lr, asr #17 │ │ │ │ stmia sl!, {r0, r1, r2, r3, r9, sl, fp, lr, pc} │ │ │ │ @ instruction: 0xf8c8000f │ │ │ │ stmdals r2, {ip, lr} │ │ │ │ - stcl 7, cr15, [r4, #-1004] @ 0xfffffc14 │ │ │ │ + stcl 7, cr15, [r6, #-1004] @ 0xfffffc14 │ │ │ │ @ instruction: 0xf7fb9801 │ │ │ │ - subs lr, fp, r2, asr #26 │ │ │ │ + subs lr, fp, r4, asr #26 │ │ │ │ strtmi r2, [r0], -r4, lsl #2 │ │ │ │ - mrc 7, 4, APSR_nzcv, cr4, cr11, {7} │ │ │ │ + mrc 7, 4, APSR_nzcv, cr6, cr11, {7} │ │ │ │ tstcs fp, r9, lsl #20 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stmiavs r0!, {r4, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ - stcl 7, cr15, [sl, #1004]! @ 0x3ec │ │ │ │ + stmiavs r0!, {r1, r4, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + stcl 7, cr15, [ip, #1004]! @ 0x3ec │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ tstcs fp, sl, lsr #1 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stcls 14, cr14, [r1, #-320] @ 0xfffffec0 │ │ │ │ + stcls 14, cr14, [r1, #-328] @ 0xfffffeb8 │ │ │ │ andcs r4, r0, #1048576 @ 0x100000 │ │ │ │ @ instruction: 0xf7fb4628 │ │ │ │ - strtmi lr, [lr], -lr, asr #29 │ │ │ │ + @ instruction: 0x462eeed0 │ │ │ │ ldrdhi pc, [r8], -sp │ │ │ │ cdpeq 1, 7, cr15, cr8, cr13, {0} │ │ │ │ strbmi r9, [r4], r2, lsr #14 │ │ │ │ ldrvc lr, [lr, -sp, asr #19] │ │ │ │ stmib sp, {r0, r1, r2, r3, r9, sl, fp, lr, pc}^ │ │ │ │ stmia ip!, {r5, r8, r9, sl, ip, sp, lr} │ │ │ │ movwcs r0, #8207 @ 0x200f │ │ │ │ @ instruction: 0xf88d9a03 │ │ │ │ strtmi r3, [fp], r8, lsl #1 │ │ │ │ stmdacs r4, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - beq 1e43834 <__bss_end__@@Base+0x1e232ec> │ │ │ │ + beq 1e43830 <__bss_end__@@Base+0x1e232e8> │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ ldrmi r9, [r5], -r1, lsl #10 │ │ │ │ @ instruction: 0x000fe8be │ │ │ │ andshi pc, r8, sp, asr #17 │ │ │ │ andeq lr, pc, fp, lsr #17 │ │ │ │ ldmdaeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -lr │ │ │ │ - stcgt 0, cr6, [pc, #-204] @ 7358 <__aeabi_atexit@plt+0x41a4> │ │ │ │ + stcgt 0, cr6, [pc, #-204] @ 7354 <__aeabi_atexit@plt+0x41a0> │ │ │ │ andeq lr, pc, sl, lsr #17 │ │ │ │ ldm r5, {r0, r2, r9, sl, fp, ip, pc} │ │ │ │ stm lr, {r0, r1} │ │ │ │ strmi r0, [r6], r3 │ │ │ │ cdpls 14, 0, cr12, cr4, cr15, {0} │ │ │ │ @ instruction: 0xf8dcc60f │ │ │ │ eorvs r1, r9, r0 │ │ │ │ ldm r8!, {r1, r2, r8, sl, fp, ip, pc} │ │ │ │ - strgt r0, [pc, #-15] @ 7439 <__aeabi_atexit@plt+0x4285> │ │ │ │ + strgt r0, [pc, #-15] @ 7435 <__aeabi_atexit@plt+0x4281> │ │ │ │ @ instruction: 0xf8cc9802 │ │ │ │ @ instruction: 0xf7fbe000 │ │ │ │ - stmdals r1, {r3, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ - stcl 7, cr15, [r4], #1004 @ 0x3ec │ │ │ │ + stmdals r1, {r1, r3, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + stcl 7, cr15, [r6], #1004 @ 0x3ec │ │ │ │ stcls 8, cr9, [r9, #-12] │ │ │ │ - mcr 7, 4, pc, cr12, cr11, {7} @ │ │ │ │ + mcr 7, 4, pc, cr14, cr11, {7} @ │ │ │ │ strtmi r4, [sl], -r3, lsl #12 │ │ │ │ @ instruction: 0x4620211b │ │ │ │ - stc 7, cr15, [lr, #1004]! @ 0x3ec │ │ │ │ + ldc 7, cr15, [r0, #1004]! @ 0x3ec │ │ │ │ addsle r2, r7, r0, lsl #16 │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ - blls 433ba4 <__bss_end__@@Base+0x41365c> │ │ │ │ + blls 433ba0 <__bss_end__@@Base+0x413658> │ │ │ │ movweq pc, #12339 @ 0x3033 @ │ │ │ │ strtmi sp, [r0], -r2, lsl #2 │ │ │ │ - stc 7, cr15, [r8, #-1004] @ 0xfffffc14 │ │ │ │ + stc 7, cr15, [sl, #-1004] @ 0xfffffc14 │ │ │ │ @ instruction: 0xf7fb9803 │ │ │ │ - blls 202b24 <__bss_end__@@Base+0x1e25dc> │ │ │ │ + blls 202b28 <__bss_end__@@Base+0x1e25e0> │ │ │ │ stmdage sl, {r1, r3, ip, pc} │ │ │ │ @ instruction: 0xf7fb6819 │ │ │ │ - blls 202940 <__bss_end__@@Base+0x1e23f8> │ │ │ │ + blls 202944 <__bss_end__@@Base+0x1e23fc> │ │ │ │ ldmdavs sp, {r0, r1, fp, ip, pc} │ │ │ │ - mcr 7, 3, pc, cr12, cr11, {7} @ │ │ │ │ + mcr 7, 3, pc, cr14, cr11, {7} @ │ │ │ │ strtmi r4, [r9], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7fba80a │ │ │ │ - stmdals r3, {r2, r3, r4, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ - ldc 7, cr15, [r8], #1004 @ 0x3ec │ │ │ │ - blmi 1419df8 <__bss_end__@@Base+0x13f98b0> │ │ │ │ + stmdals r3, {r1, r2, r3, r4, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + ldc 7, cr15, [sl], #1004 @ 0x3ec │ │ │ │ + blmi 1419df4 <__bss_end__@@Base+0x13f98ac> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 961524 <__bss_end__@@Base+0x940fdc> │ │ │ │ + blls 961520 <__bss_end__@@Base+0x940fd8> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ eorlt r8, r7, r5, lsl #1 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - blls 20285c <__bss_end__@@Base+0x1e2314> │ │ │ │ - blcs 21544 <__bss_end__@@Base+0xffc> │ │ │ │ - blmi 123b878 <__bss_end__@@Base+0x121b330> │ │ │ │ + blls 202860 <__bss_end__@@Base+0x1e2318> │ │ │ │ + blcs 21540 <__bss_end__@@Base+0xff8> │ │ │ │ + blmi 123b874 <__bss_end__@@Base+0x121b32c> │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf8d30090 │ │ │ │ vshr.u64 d3, d0, #1 │ │ │ │ @ instruction: 0x07da8f5b │ │ │ │ stcge 5, cr13, [sl], {46} @ 0x2e │ │ │ │ strtmi r4, [r0], -r3, asr #22 │ │ │ │ ldrbtmi r9, [fp], #-2567 @ 0xfffff5f9 │ │ │ │ @ instruction: 0xf8d36811 │ │ │ │ movwls r3, #41108 @ 0xa094 │ │ │ │ - ldcl 7, cr15, [r2], #1004 @ 0x3ec │ │ │ │ + ldcl 7, cr15, [r4], #1004 @ 0x3ec │ │ │ │ andcs r9, r0, #7168 @ 0x1c00 │ │ │ │ ldmdavs r9, {r5, r9, sl, lr} │ │ │ │ - stcl 7, cr15, [r8], {251} @ 0xfb │ │ │ │ + stcl 7, cr15, [sl], {251} @ 0xfb │ │ │ │ strtmi lr, [r0], -fp, asr #15 │ │ │ │ - ldc 7, cr15, [lr], #1004 @ 0x3ec │ │ │ │ + stcl 7, cr15, [r0], {251} @ 0xfb │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ sbcle r2, r4, r0, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2872 @ 0xfffff4c8 │ │ │ │ addseq pc, r8, r3, lsl #2 │ │ │ │ @ instruction: 0x3098f8d3 │ │ │ │ svchi 0x005bf3bf │ │ │ │ strle r0, [r2, #-2011]! @ 0xfffff825 │ │ │ │ - blmi d32560 <__bss_end__@@Base+0xd12018> │ │ │ │ - bls 1d8dbc <__bss_end__@@Base+0x1b8874> │ │ │ │ + blmi d3255c <__bss_end__@@Base+0xd12014> │ │ │ │ + bls 1d8db8 <__bss_end__@@Base+0x1b8870> │ │ │ │ ldmdavs r1, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ @ instruction: 0x309cf8d3 │ │ │ │ @ instruction: 0xf7fb930a │ │ │ │ - @ instruction: 0xe7dbecd0 │ │ │ │ - stcl 7, cr15, [r6, #-1004]! @ 0xfffffc14 │ │ │ │ + @ instruction: 0xe7dbecd2 │ │ │ │ + stcl 7, cr15, [r8, #-1004]! @ 0xfffffc14 │ │ │ │ sbcle r2, ip, r0, lsl #16 │ │ │ │ @ instruction: 0xac0a4b2d │ │ │ │ ldrbtmi r2, [fp], #-528 @ 0xfffffdf0 │ │ │ │ movwcs lr, #43469 @ 0xa9cd │ │ │ │ muleq r3, r4, r8 │ │ │ │ - mrc 7, 0, APSR_nzcv, cr4, cr11, {7} │ │ │ │ + mrc 7, 0, APSR_nzcv, cr6, cr11, {7} │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ addseq pc, r4, r3, asr #17 │ │ │ │ addseq pc, r0, r3, lsl #2 │ │ │ │ - stc 7, cr15, [r8, #1004] @ 0x3ec │ │ │ │ + stc 7, cr15, [sl, #1004] @ 0x3ec │ │ │ │ @ instruction: 0xf7fbe7ba │ │ │ │ - stmdacs r0, {r4, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ - blmi 93b8e4 <__bss_end__@@Base+0x91b39c> │ │ │ │ + stmdacs r0, {r1, r4, r6, r8, sl, fp, sp, lr, pc} │ │ │ │ + blmi 93b8e0 <__bss_end__@@Base+0x91b398> │ │ │ │ andscs sl, r0, #2560 @ 0xa00 │ │ │ │ stmib sp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldm r4, {r1, r3, r8, r9, sp} │ │ │ │ @ instruction: 0xf7fb0003 │ │ │ │ - blmi 842d90 <__bss_end__@@Base+0x822848> │ │ │ │ + blmi 842d94 <__bss_end__@@Base+0x82284c> │ │ │ │ @ instruction: 0xf8c3447b │ │ │ │ @ instruction: 0xf103009c │ │ │ │ @ instruction: 0xf7fb0098 │ │ │ │ - @ instruction: 0xe7c6ed72 │ │ │ │ + @ instruction: 0xe7c6ed74 │ │ │ │ @ instruction: 0x46044b1c │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fb0090 │ │ │ │ - stmdals r3, {r2, r3, r4, sl, fp, sp, lr, pc} │ │ │ │ - ldc 7, cr15, [r2], #-1004 @ 0xfffffc14 │ │ │ │ - blmi 359e20 <__bss_end__@@Base+0x3398d8> │ │ │ │ + stmdals r3, {r1, r2, r3, r4, sl, fp, sp, lr, pc} │ │ │ │ + ldc 7, cr15, [r4], #-1004 @ 0xfffffc14 │ │ │ │ + blmi 359e1c <__bss_end__@@Base+0x3398d4> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 961630 <__bss_end__@@Base+0x9410e8> │ │ │ │ + blls 96162c <__bss_end__@@Base+0x9410e4> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ andle r0, fp, r0, lsl #6 │ │ │ │ - bl ffd455c0 <__bss_end__@@Base+0xffd25078> │ │ │ │ + bl ffdc55bc <__bss_end__@@Base+0xffda5074> │ │ │ │ strb r4, [lr, r4, lsl #12]! │ │ │ │ @ instruction: 0x46044b12 │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fb0098 │ │ │ │ - strb lr, [r6, r4, lsl #24]! │ │ │ │ + strb lr, [r6, r6, lsl #24]! │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - svclt 0x0000ec48 │ │ │ │ - andeq r8, r1, lr, asr fp │ │ │ │ + svclt 0x0000ec4a │ │ │ │ + andeq r8, r1, r2, ror #22 │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq r8, r1, r4, ror r9 │ │ │ │ - andeq r8, r1, r0, ror pc │ │ │ │ - andeq r8, r1, r6, asr pc │ │ │ │ - andeq r8, r1, sl, lsr #30 │ │ │ │ - andeq r8, r1, r0, lsl pc │ │ │ │ - andeq r1, r0, r2, ror #6 │ │ │ │ - andeq r8, r1, r2, ror #29 │ │ │ │ - andeq r1, r0, r4, lsr r3 │ │ │ │ - @ instruction: 0x00018eb4 │ │ │ │ - andeq r8, r1, r0, lsr #29 │ │ │ │ - andeq r8, r1, r8, ror #16 │ │ │ │ - andeq r8, r1, r0, ror lr │ │ │ │ + andeq r8, r1, r8, ror r9 │ │ │ │ + andeq r8, r1, r4, ror pc │ │ │ │ + andeq r8, r1, sl, asr pc │ │ │ │ + andeq r8, r1, lr, lsr #30 │ │ │ │ + andeq r8, r1, r4, lsl pc │ │ │ │ + andeq r1, r0, r6, ror #6 │ │ │ │ + andeq r8, r1, r6, ror #29 │ │ │ │ + andeq r1, r0, r8, lsr r3 │ │ │ │ + @ instruction: 0x00018eb8 │ │ │ │ + andeq r8, r1, r4, lsr #29 │ │ │ │ + andeq r8, r1, ip, ror #16 │ │ │ │ + andeq r8, r1, r4, ror lr │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0040f8cc │ │ │ │ movwcs fp, #167 @ 0xa7 │ │ │ │ andcs sl, r2, #12, 26 @ 0x300 │ │ │ │ movwls r4, #50692 @ 0xc604 │ │ │ │ movwcc lr, #6597 @ 0x19c5 │ │ │ │ - bmi ff2abe8c <__bss_end__@@Base+0xff28b944> │ │ │ │ + bmi ff2abe88 <__bss_end__@@Base+0xff28b940> │ │ │ │ ldrbtmi r4, [sl], #-3018 @ 0xfffff436 │ │ │ │ tstls r7, r3, lsl #10 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9325 │ │ │ │ and r0, sp, r0, lsl #6 │ │ │ │ strtmi r2, [r0], -r2, lsl #2 │ │ │ │ - ldc 7, cr15, [r4, #-1004]! @ 0xfffffc14 │ │ │ │ + ldc 7, cr15, [r6, #-1004]! @ 0xfffffc14 │ │ │ │ @ instruction: 0x4620211c │ │ │ │ - ldcl 7, cr15, [r6], #-1004 @ 0xfffffc14 │ │ │ │ + ldcl 7, cr15, [r8], #-1004 @ 0xfffffc14 │ │ │ │ @ instruction: 0xf7fb68a0 │ │ │ │ - stmdacs r0, {r2, r3, r7, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r3, r7, sl, fp, sp, lr, pc} │ │ │ │ rschi pc, sl, r0, asr #32 │ │ │ │ tstcs ip, r9, lsl #20 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stmdacs r0, {r2, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r5, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ tstcs sp, sl, ror #1 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - strmi lr, [r1], -sl, ror #25 │ │ │ │ + strmi lr, [r1], -ip, ror #25 │ │ │ │ ldmdage r2, {r9, sp} │ │ │ │ - stcl 7, cr15, [r8, #-1004]! @ 0xfffffc14 │ │ │ │ + stcl 7, cr15, [sl, #-1004]! @ 0xfffffc14 │ │ │ │ smladcs r0, r2, sl, sl │ │ │ │ @ instruction: 0x97224616 │ │ │ │ movwcs r9, #8705 @ 0x2201 │ │ │ │ @ instruction: 0xf88d4694 │ │ │ │ cdpgt 0, 0, cr3, cr15, cr8, {4} │ │ │ │ stmdaeq r0!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x971ead1e │ │ │ │ @@ -4428,213 +4427,213 @@ │ │ │ │ strgt r0, [pc], -pc │ │ │ │ @ instruction: 0xf8d84656 │ │ │ │ movwls r3, #20480 @ 0x5000 │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ cdpgt 6, 0, cr4, cr15, cr5, {0} │ │ │ │ stmia fp!, {r1, r2, r3, r4, r9, sl, fp, sp, pc} │ │ │ │ - blls 147744 <__bss_end__@@Base+0x1271fc> │ │ │ │ + blls 147740 <__bss_end__@@Base+0x1271f8> │ │ │ │ andcc pc, r0, lr, asr #17 │ │ │ │ stmia sl!, {r0, r1, r2, r3, r9, sl, fp, lr, pc} │ │ │ │ @ instruction: 0xf8c8000f │ │ │ │ stmdals r2, {ip, lr} │ │ │ │ - bl fe0c5708 <__bss_end__@@Base+0xfe0a51c0> │ │ │ │ + bl fe145704 <__bss_end__@@Base+0xfe1251bc> │ │ │ │ @ instruction: 0xf7fb9801 │ │ │ │ - subs lr, fp, r0, lsl #23 │ │ │ │ + subs lr, fp, r2, lsl #23 │ │ │ │ strtmi r2, [r0], -r4, lsl #2 │ │ │ │ - ldcl 7, cr15, [r2], {251} @ 0xfb │ │ │ │ + ldcl 7, cr15, [r4], {251} @ 0xfb │ │ │ │ tstcs sp, r9, lsl #20 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stmiavs r0!, {r1, r2, r3, r6, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ - stc 7, cr15, [r8], #-1004 @ 0xfffffc14 │ │ │ │ + stmiavs r0!, {r4, r6, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ + stc 7, cr15, [sl], #-1004 @ 0xfffffc14 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ tstcs sp, sl, lsr #1 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stcls 12, cr14, [r1, #-568] @ 0xfffffdc8 │ │ │ │ + stcls 12, cr14, [r1, #-576] @ 0xfffffdc0 │ │ │ │ andcs r4, r0, #1048576 @ 0x100000 │ │ │ │ @ instruction: 0xf7fb4628 │ │ │ │ - strtmi lr, [lr], -ip, lsl #26 │ │ │ │ + strtmi lr, [lr], -lr, lsl #26 │ │ │ │ ldrdhi pc, [r8], -sp │ │ │ │ cdpeq 1, 7, cr15, cr8, cr13, {0} │ │ │ │ strbmi r9, [r4], r2, lsr #14 │ │ │ │ ldrvc lr, [lr, -sp, asr #19] │ │ │ │ stmib sp, {r0, r1, r2, r3, r9, sl, fp, lr, pc}^ │ │ │ │ stmia ip!, {r5, r8, r9, sl, ip, sp, lr} │ │ │ │ movwcs r0, #8207 @ 0x200f │ │ │ │ @ instruction: 0xf88d9a03 │ │ │ │ strtmi r3, [fp], r8, lsl #1 │ │ │ │ stmdacs r4, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - beq 1e43bb8 <__bss_end__@@Base+0x1e23670> │ │ │ │ + beq 1e43bb4 <__bss_end__@@Base+0x1e2366c> │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ ldrmi r9, [r5], -r1, lsl #10 │ │ │ │ @ instruction: 0x000fe8be │ │ │ │ andshi pc, r8, sp, asr #17 │ │ │ │ andeq lr, pc, fp, lsr #17 │ │ │ │ ldmdaeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -lr │ │ │ │ - stcgt 0, cr6, [pc, #-204] @ 76dc <__aeabi_atexit@plt+0x4528> │ │ │ │ + stcgt 0, cr6, [pc, #-204] @ 76d8 <__aeabi_atexit@plt+0x4524> │ │ │ │ andeq lr, pc, sl, lsr #17 │ │ │ │ ldm r5, {r0, r2, r9, sl, fp, ip, pc} │ │ │ │ stm lr, {r0, r1} │ │ │ │ strmi r0, [r6], r3 │ │ │ │ cdpls 14, 0, cr12, cr4, cr15, {0} │ │ │ │ @ instruction: 0xf8dcc60f │ │ │ │ eorvs r1, r9, r0 │ │ │ │ ldm r8!, {r1, r2, r8, sl, fp, ip, pc} │ │ │ │ - strgt r0, [pc, #-15] @ 77bd <__aeabi_atexit@plt+0x4609> │ │ │ │ + strgt r0, [pc, #-15] @ 77b9 <__aeabi_atexit@plt+0x4605> │ │ │ │ @ instruction: 0xf8cc9802 │ │ │ │ @ instruction: 0xf7fbe000 │ │ │ │ - stmdals r1, {r1, r2, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ - bl 8c57c8 <__bss_end__@@Base+0x8a5280> │ │ │ │ + stmdals r1, {r3, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ + bl 9457c4 <__bss_end__@@Base+0x92527c> │ │ │ │ stcls 8, cr9, [r9, #-12] │ │ │ │ - stcl 7, cr15, [sl], {251} @ 0xfb │ │ │ │ + stcl 7, cr15, [ip], {251} @ 0xfb │ │ │ │ strtmi r4, [sl], -r3, lsl #12 │ │ │ │ @ instruction: 0x4620211d │ │ │ │ - bl ffb457dc <__bss_end__@@Base+0xffb25294> │ │ │ │ + bl ffbc57d8 <__bss_end__@@Base+0xffba5290> │ │ │ │ addsle r2, r7, r0, lsl #16 │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ - blls 433f28 <__bss_end__@@Base+0x4139e0> │ │ │ │ + blls 433f24 <__bss_end__@@Base+0x4139dc> │ │ │ │ movweq pc, #12339 @ 0x3033 @ │ │ │ │ strtmi sp, [r0], -r2, lsl #2 │ │ │ │ - bl 11c57f4 <__bss_end__@@Base+0x11a52ac> │ │ │ │ + bl 12457f0 <__bss_end__@@Base+0x12252a8> │ │ │ │ @ instruction: 0xf7fb9803 │ │ │ │ - blls 2027a0 <__bss_end__@@Base+0x1e2258> │ │ │ │ + blls 2027a4 <__bss_end__@@Base+0x1e225c> │ │ │ │ stmdage sl, {r1, r3, ip, pc} │ │ │ │ @ instruction: 0xf7fb6819 │ │ │ │ - blls 2025bc <__bss_end__@@Base+0x1e2074> │ │ │ │ + blls 2025c0 <__bss_end__@@Base+0x1e2078> │ │ │ │ ldmdavs sp, {r0, r1, fp, ip, pc} │ │ │ │ - stc 7, cr15, [sl], #1004 @ 0x3ec │ │ │ │ + stc 7, cr15, [ip], #1004 @ 0x3ec │ │ │ │ strtmi r4, [r9], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7fba80a │ │ │ │ - stmdals r3, {r1, r3, r4, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ - b ffdc5820 <__bss_end__@@Base+0xffda52d8> │ │ │ │ - blmi 141a17c <__bss_end__@@Base+0x13f9c34> │ │ │ │ + stmdals r3, {r2, r3, r4, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ + b ffe4581c <__bss_end__@@Base+0xffe252d4> │ │ │ │ + blmi 141a178 <__bss_end__@@Base+0x13f9c30> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 9618a8 <__bss_end__@@Base+0x941360> │ │ │ │ + blls 9618a4 <__bss_end__@@Base+0x94135c> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ eorlt r8, r7, r5, lsl #1 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - blls 2024d8 <__bss_end__@@Base+0x1e1f90> │ │ │ │ - blcs 218c8 <__bss_end__@@Base+0x1380> │ │ │ │ - blmi 123bbfc <__bss_end__@@Base+0x121b6b4> │ │ │ │ + blls 2024dc <__bss_end__@@Base+0x1e1f94> │ │ │ │ + blcs 218c4 <__bss_end__@@Base+0x137c> │ │ │ │ + blmi 123bbf8 <__bss_end__@@Base+0x121b6b0> │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf8d300a0 │ │ │ │ vaddl.u , d31, d16 │ │ │ │ @ instruction: 0x07da8f5b │ │ │ │ stcge 5, cr13, [sl], {46} @ 0x2e │ │ │ │ strtmi r4, [r0], -r3, asr #22 │ │ │ │ ldrbtmi r9, [fp], #-2567 @ 0xfffff5f9 │ │ │ │ @ instruction: 0xf8d36811 │ │ │ │ movwls r3, #41124 @ 0xa0a4 │ │ │ │ - bl c45874 <__bss_end__@@Base+0xc2532c> │ │ │ │ + bl cc5870 <__bss_end__@@Base+0xca5328> │ │ │ │ andcs r9, r0, #7168 @ 0x1c00 │ │ │ │ ldmdavs r9, {r5, r9, sl, lr} │ │ │ │ - bl 1c5880 <__bss_end__@@Base+0x1a5338> │ │ │ │ + bl 24587c <__bss_end__@@Base+0x225334> │ │ │ │ strtmi lr, [r0], -fp, asr #15 │ │ │ │ - b fff45888 <__bss_end__@@Base+0xfff25340> │ │ │ │ + b fffc5884 <__bss_end__@@Base+0xfffa533c> │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ sbcle r2, r4, r0, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2872 @ 0xfffff4c8 │ │ │ │ adceq pc, r8, r3, lsl #2 │ │ │ │ ldrdcc pc, [r8], r3 @ │ │ │ │ svchi 0x005bf3bf │ │ │ │ strle r0, [r2, #-2011]! @ 0xfffff825 │ │ │ │ - blmi d328e4 <__bss_end__@@Base+0xd1239c> │ │ │ │ - bls 1d9140 <__bss_end__@@Base+0x1b8bf8> │ │ │ │ + blmi d328e0 <__bss_end__@@Base+0xd12398> │ │ │ │ + bls 1d913c <__bss_end__@@Base+0x1b8bf4> │ │ │ │ ldmdavs r1, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldrdcc pc, [ip], r3 @ │ │ │ │ @ instruction: 0xf7fb930a │ │ │ │ - ldrb lr, [fp, lr, lsl #22] │ │ │ │ - bl fe9458c0 <__bss_end__@@Base+0xfe925378> │ │ │ │ + bfi lr, r0, #22, #6 │ │ │ │ + bl fe9c58bc <__bss_end__@@Base+0xfe9a5374> │ │ │ │ sbcle r2, ip, r0, lsl #16 │ │ │ │ @ instruction: 0xac0a4b2d │ │ │ │ ldrbtmi r2, [fp], #-528 @ 0xfffffdf0 │ │ │ │ movwcs lr, #43469 @ 0xa9cd │ │ │ │ muleq r3, r4, r8 │ │ │ │ - mrrc 7, 15, pc, r2, cr11 @ │ │ │ │ + mrrc 7, 15, pc, r4, cr11 @ │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ adceq pc, r4, r3, asr #17 │ │ │ │ adceq pc, r0, r3, lsl #2 │ │ │ │ - bl ff1c58e8 <__bss_end__@@Base+0xff1a53a0> │ │ │ │ + bl ff2458e4 <__bss_end__@@Base+0xff22539c> │ │ │ │ @ instruction: 0xf7fbe7ba │ │ │ │ - stmdacs r0, {r1, r2, r3, r7, r8, r9, fp, sp, lr, pc} │ │ │ │ - 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blls 9619b4 <__bss_end__@@Base+0x94146c> │ │ │ │ + blls 9619b0 <__bss_end__@@Base+0x941468> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ andle r0, fp, r0, lsl #6 │ │ │ │ - b cc5944 <__bss_end__@@Base+0xca53fc> │ │ │ │ + b d45940 <__bss_end__@@Base+0xd253f8> │ │ │ │ strb r4, [lr, r4, lsl #12]! │ │ │ │ @ instruction: 0x46044b12 │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fb00a8 │ │ │ │ - strb lr, [r6, r2, asr #20]! │ │ │ │ + strb lr, [r6, r4, asr #20]! │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - svclt 0x0000ea86 │ │ │ │ - ldrdeq r8, [r1], -sl │ │ │ │ + svclt 0x0000ea88 │ │ │ │ + ldrdeq r8, [r1], -lr │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ + strdeq r8, [r1], -r4 │ │ │ │ + strdeq r8, [r1], -r0 │ │ │ │ + ldrdeq r8, [r1], -r6 │ │ │ │ + andeq r8, r1, sl, lsr #23 │ │ │ │ + muleq r1, r0, fp │ │ │ │ + andeq r0, r0, r2, ror #31 │ │ │ │ + andeq r8, r1, r2, ror #22 │ │ │ │ + @ instruction: 0x00000fb4 │ │ │ │ + andeq r8, r1, r4, lsr fp │ │ │ │ + andeq r8, r1, r0, lsr #22 │ │ │ │ + andeq r8, r1, r8, ror #9 │ │ │ │ strdeq r8, [r1], -r0 │ │ │ │ - andeq r8, r1, ip, ror #23 │ │ │ │ - ldrdeq r8, [r1], -r2 │ │ │ │ - andeq r8, r1, r6, lsr #23 │ │ │ │ - andeq r8, r1, ip, lsl #23 │ │ │ │ - ldrdeq r0, [r0], -lr │ │ │ │ - andeq r8, r1, lr, asr fp │ │ │ │ - @ instruction: 0x00000fb0 │ │ │ │ - andeq r8, r1, r0, lsr fp │ │ │ │ - andeq r8, r1, ip, lsl fp │ │ │ │ - andeq r8, r1, r4, ror #9 │ │ │ │ - andeq r8, r1, ip, ror #21 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0040f8cc │ │ │ │ movwcs fp, #167 @ 0xa7 │ │ │ │ andcs sl, r2, #12, 26 @ 0x300 │ │ │ │ movwls r4, #50692 @ 0xc604 │ │ │ │ movwcc lr, #6597 @ 0x19c5 │ │ │ │ - bmi ff2ac210 <__bss_end__@@Base+0xff28bcc8> │ │ │ │ + bmi ff2ac20c <__bss_end__@@Base+0xff28bcc4> │ │ │ │ ldrbtmi r4, [sl], #-3018 @ 0xfffff436 │ │ │ │ tstls r7, r3, lsl #10 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9325 │ │ │ │ and r0, sp, r0, lsl #6 │ │ │ │ strtmi r2, [r0], -r2, lsl #2 │ │ │ │ - bl 1cc59d8 <__bss_end__@@Base+0x1ca5490> │ │ │ │ + bl 1d459d4 <__bss_end__@@Base+0x1d2548c> │ │ │ │ @ instruction: 0x4620211e │ │ │ │ - b fed459e0 <__bss_end__@@Base+0xfed25498> │ │ │ │ + b fedc59dc <__bss_end__@@Base+0xfeda5494> │ │ │ │ @ instruction: 0xf7fb68a0 │ │ │ │ - stmdacs r0, {r1, r3, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r2, r3, r6, r7, r9, fp, sp, lr, pc} │ │ │ │ rschi pc, sl, r0, asr #32 │ │ │ │ tstcs lr, r9, lsl #20 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stmdacs r0, {r1, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r2, r5, r8, r9, fp, sp, lr, pc} │ │ │ │ tstcs pc, sl, ror #1 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - strmi lr, [r1], -r8, lsr #22 │ │ │ │ + strmi lr, [r1], -sl, lsr #22 │ │ │ │ ldmdage r2, {r9, sp} │ │ │ │ - bl fe9c5a0c <__bss_end__@@Base+0xfe9a54c4> │ │ │ │ + bl fea45a08 <__bss_end__@@Base+0xfea254c0> │ │ │ │ smladcs r0, r2, sl, sl │ │ │ │ @ instruction: 0x97224616 │ │ │ │ movwcs r9, #8705 @ 0x2201 │ │ │ │ @ instruction: 0xf88d4694 │ │ │ │ cdpgt 0, 0, cr3, cr15, cr8, {4} │ │ │ │ stmdaeq r0!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x971ead1e │ │ │ │ @@ -4653,213 +4652,213 @@ │ │ │ │ strgt r0, [pc], -pc │ │ │ │ @ instruction: 0xf8d84656 │ │ │ │ movwls r3, #20480 @ 0x5000 │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ cdpgt 6, 0, cr4, cr15, cr5, {0} │ │ │ │ stmia fp!, {r1, r2, r3, r4, r9, sl, fp, sp, pc} │ │ │ │ - blls 147ac8 <__bss_end__@@Base+0x127580> │ │ │ │ + blls 147ac4 <__bss_end__@@Base+0x12757c> │ │ │ │ andcc pc, r0, lr, asr #17 │ │ │ │ stmia sl!, {r0, r1, r2, r3, r9, sl, fp, lr, pc} │ │ │ │ @ instruction: 0xf8c8000f │ │ │ │ stmdals r2, {ip, lr} │ │ │ │ - stmib r0, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib r2, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7fb9801 │ │ │ │ - ldrh lr, [fp], #-158 @ 0xffffff62 │ │ │ │ + subs lr, fp, r0, asr #19 │ │ │ │ strtmi r2, [r0], -r4, lsl #2 │ │ │ │ - bl 445a9c <__bss_end__@@Base+0x425554> │ │ │ │ + bl 4c5a98 <__bss_end__@@Base+0x4a5550> │ │ │ │ tstcs pc, r9, lsl #20 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stmiavs r0!, {r2, r3, r9, fp, sp, lr, pc} │ │ │ │ - b 19c5aac <__bss_end__@@Base+0x19a5564> │ │ │ │ + stmiavs r0!, {r1, r2, r3, r9, fp, sp, lr, pc} │ │ │ │ + b 1a45aa8 <__bss_end__@@Base+0x1a25560> │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ tstcs pc, sl, lsr #1 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - vstrls s28, [r1, #-816] @ 0xfffffcd0 │ │ │ │ + vstrls s28, [r1, #-824] @ 0xfffffcc8 │ │ │ │ andcs r4, r0, #1048576 @ 0x100000 │ │ │ │ @ instruction: 0xf7fb4628 │ │ │ │ - strtmi lr, [lr], -sl, asr #22 │ │ │ │ + strtmi lr, [lr], -ip, asr #22 │ │ │ │ ldrdhi pc, [r8], -sp │ │ │ │ cdpeq 1, 7, cr15, cr8, cr13, {0} │ │ │ │ strbmi r9, [r4], r2, lsr #14 │ │ │ │ ldrvc lr, [lr, -sp, asr #19] │ │ │ │ stmib sp, {r0, r1, r2, r3, r9, sl, fp, lr, pc}^ │ │ │ │ stmia ip!, {r5, r8, r9, sl, ip, sp, lr} │ │ │ │ movwcs r0, #8207 @ 0x200f │ │ │ │ @ instruction: 0xf88d9a03 │ │ │ │ strtmi r3, [fp], r8, lsl #1 │ │ │ │ stmdacs r4, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - beq 1e43f3c <__bss_end__@@Base+0x1e239f4> │ │ │ │ + beq 1e43f38 <__bss_end__@@Base+0x1e239f0> │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ ldrmi r9, [r5], -r1, lsl #10 │ │ │ │ @ instruction: 0x000fe8be │ │ │ │ andshi pc, r8, sp, asr #17 │ │ │ │ andeq lr, pc, fp, lsr #17 │ │ │ │ ldmdaeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -lr │ │ │ │ - stcgt 0, cr6, [pc, #-204] @ 7a60 <__aeabi_atexit@plt+0x48ac> │ │ │ │ + stcgt 0, cr6, [pc, #-204] @ 7a5c <__aeabi_atexit@plt+0x48a8> │ │ │ │ andeq lr, pc, sl, lsr #17 │ │ │ │ ldm r5, {r0, r2, r9, sl, fp, ip, pc} │ │ │ │ stm lr, {r0, r1} │ │ │ │ strmi r0, [r6], r3 │ │ │ │ cdpls 14, 0, cr12, cr4, cr15, {0} │ │ │ │ @ instruction: 0xf8dcc60f │ │ │ │ eorvs r1, r9, r0 │ │ │ │ ldm r8!, {r1, r2, r8, sl, fp, ip, pc} │ │ │ │ - strgt r0, [pc, #-15] @ 7b41 <__aeabi_atexit@plt+0x498d> │ │ │ │ + strgt r0, [pc, #-15] @ 7b3d <__aeabi_atexit@plt+0x4989> │ │ │ │ @ instruction: 0xf8cc9802 │ │ │ │ @ instruction: 0xf7fbe000 │ │ │ │ - stmdals r1, {r2, r5, r6, r8, fp, sp, lr, pc} │ │ │ │ - stmdb r0!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdals r1, {r1, r2, r5, r6, r8, fp, sp, lr, pc} │ │ │ │ + stmdb r2!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ stcls 8, cr9, [r9, #-12] │ │ │ │ - bl 245b54 <__bss_end__@@Base+0x22560c> │ │ │ │ + bl 2c5b50 <__bss_end__@@Base+0x2a5608> │ │ │ │ strtmi r4, [sl], -r3, lsl #12 │ │ │ │ @ instruction: 0x4620211f │ │ │ │ - b ac5b60 <__bss_end__@@Base+0xaa5618> │ │ │ │ + b b45b5c <__bss_end__@@Base+0xb25614> │ │ │ │ addsle r2, r7, r0, lsl #16 │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ - blls 4342ac <__bss_end__@@Base+0x413d64> │ │ │ │ + blls 4342a8 <__bss_end__@@Base+0x413d60> │ │ │ │ movweq pc, #12339 @ 0x3033 @ │ │ │ │ strtmi sp, [r0], -r2, lsl #2 │ │ │ │ - stmib r4, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmib r6, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fb9803 │ │ │ │ - blls 20241c <__bss_end__@@Base+0x1e1ed4> │ │ │ │ + blls 202420 <__bss_end__@@Base+0x1e1ed8> │ │ │ │ stmdage sl, {r1, r3, ip, pc} │ │ │ │ @ instruction: 0xf7fb6819 │ │ │ │ - blls 202238 <__bss_end__@@Base+0x1e1cf0> │ │ │ │ + blls 20223c <__bss_end__@@Base+0x1e1cf4> │ │ │ │ ldmdavs sp, {r0, r1, fp, ip, pc} │ │ │ │ - b ffa45b94 <__bss_end__@@Base+0xffa2564c> │ │ │ │ + b ffac5b90 <__bss_end__@@Base+0xffaa5648> │ │ │ │ strtmi r4, [r9], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7fba80a │ │ │ │ - stmdals r3, {r3, r4, r5, r6, r8, fp, sp, lr, pc} │ │ │ │ - ldmdb r4!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blmi 141a500 <__bss_end__@@Base+0x13f9fb8> │ │ │ │ + stmdals r3, {r1, r3, r4, r5, r6, r8, fp, sp, lr, pc} │ │ │ │ + ldmdb r6!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blmi 141a4fc <__bss_end__@@Base+0x13f9fb4> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 961c2c <__bss_end__@@Base+0x9416e4> │ │ │ │ + blls 961c28 <__bss_end__@@Base+0x9416e0> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ eorlt r8, r7, r5, lsl #1 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - blls 202154 <__bss_end__@@Base+0x1e1c0c> │ │ │ │ - blcs 21c4c <__bss_end__@@Base+0x1704> │ │ │ │ - blmi 123bf80 <__bss_end__@@Base+0x121ba38> │ │ │ │ + blls 202158 <__bss_end__@@Base+0x1e1c10> │ │ │ │ + blcs 21c48 <__bss_end__@@Base+0x1700> │ │ │ │ + blmi 123bf7c <__bss_end__@@Base+0x121ba34> │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf8d300b0 │ │ │ │ vshr.u64 d3, d16, #1 │ │ │ │ @ instruction: 0x07da8f5b │ │ │ │ stcge 5, cr13, [sl], {46} @ 0x2e │ │ │ │ strtmi r4, [r0], -r3, asr #22 │ │ │ │ ldrbtmi r9, [fp], #-2567 @ 0xfffff5f9 │ │ │ │ @ instruction: 0xf8d36811 │ │ │ │ movwls r3, #41140 @ 0xa0b4 │ │ │ │ - stmdb lr!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdb r0!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ andcs r9, r0, #7168 @ 0x1c00 │ │ │ │ ldmdavs r9, {r5, r9, sl, lr} │ │ │ │ - stmdb r4, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb r6, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ strtmi lr, [r0], -fp, asr #15 │ │ │ │ - ldmdb sl!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmdb ip!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ sbcle r2, r4, r0, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2872 @ 0xfffff4c8 │ │ │ │ adcseq pc, r8, r3, lsl #2 │ │ │ │ ldrsbtcc pc, [r8], r3 @ │ │ │ │ svchi 0x005bf3bf │ │ │ │ strle r0, [r2, #-2011]! @ 0xfffff825 │ │ │ │ - blmi d32c68 <__bss_end__@@Base+0xd12720> │ │ │ │ - bls 1d94c4 <__bss_end__@@Base+0x1b8f7c> │ │ │ │ + blmi d32c64 <__bss_end__@@Base+0xd1271c> │ │ │ │ + bls 1d94c0 <__bss_end__@@Base+0x1b8f78> │ │ │ │ ldmdavs r1, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldrsbtcc pc, [ip], r3 @ │ │ │ │ @ instruction: 0xf7fb930a │ │ │ │ - ldrb lr, [fp, ip, asr #18] │ │ │ │ - stmib r2!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldrb lr, [fp, lr, asr #18] │ │ │ │ + stmib r4!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ sbcle r2, ip, r0, lsl #16 │ │ │ │ @ instruction: 0xac0a4b2d │ │ │ │ ldrbtmi r2, [fp], #-528 @ 0xfffffdf0 │ │ │ │ movwcs lr, #43469 @ 0xa9cd │ │ │ │ muleq r3, r4, r8 │ │ │ │ - b fe445c5c <__bss_end__@@Base+0xfe425714> │ │ │ │ + b fe4c5c58 <__bss_end__@@Base+0xfe4a5710> │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ adcseq pc, r4, r3, asr #17 │ │ │ │ adcseq pc, r0, r3, lsl #2 │ │ │ │ - b 145c6c <__bss_end__@@Base+0x125724> │ │ │ │ + b 1c5c68 <__bss_end__@@Base+0x1a5720> │ │ │ │ @ instruction: 0xf7fbe7ba │ │ │ │ - stmdacs r0, {r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - blmi 93bfec <__bss_end__@@Base+0x91baa4> │ │ │ │ + stmdacs r0, {r1, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ + blmi 93bfe8 <__bss_end__@@Base+0x91baa0> │ │ │ │ andscs sl, r0, #2560 @ 0xa00 │ │ │ │ stmib sp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldm r4, {r1, r3, r8, r9, sp} │ │ │ │ @ instruction: 0xf7fb0003 │ │ │ │ - blmi 842688 <__bss_end__@@Base+0x822140> │ │ │ │ + blmi 84268c <__bss_end__@@Base+0x822144> │ │ │ │ @ instruction: 0xf8c3447b │ │ │ │ @ instruction: 0xf10300bc │ │ │ │ @ instruction: 0xf7fb00b8 │ │ │ │ - strb lr, [r6, lr, ror #19] │ │ │ │ + @ instruction: 0xe7c6e9f0 │ │ │ │ @ instruction: 0x46044b1c │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fb00b0 │ │ │ │ - stmdals r3, {r3, r4, r7, fp, sp, lr, pc} │ │ │ │ - stmia lr!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ - blmi 35a528 <__bss_end__@@Base+0x339fe0> │ │ │ │ + stmdals r3, {r1, r3, r4, r7, fp, sp, lr, pc} │ │ │ │ + ldm r0!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + blmi 35a524 <__bss_end__@@Base+0x339fdc> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 961d38 <__bss_end__@@Base+0x9417f0> │ │ │ │ + blls 961d34 <__bss_end__@@Base+0x9417ec> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ andle r0, fp, r0, lsl #6 │ │ │ │ - ldmda r0!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmda r2!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ strb r4, [lr, r4, lsl #12]! │ │ │ │ @ instruction: 0x46044b12 │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fb00b8 │ │ │ │ - strb lr, [r6, r0, lsl #17]! │ │ │ │ + strb lr, [r6, r2, lsl #17]! │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - svclt 0x0000e8c4 │ │ │ │ - andeq r8, r1, r6, asr r4 │ │ │ │ + svclt 0x0000e8c6 │ │ │ │ + andeq r8, r1, sl, asr r4 │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq r8, r1, ip, ror #4 │ │ │ │ - andeq r8, r1, r8, ror #16 │ │ │ │ - andeq r8, r1, lr, asr #16 │ │ │ │ - andeq r8, r1, r2, lsr #16 │ │ │ │ - andeq r8, r1, r8, lsl #16 │ │ │ │ - andeq r0, r0, sl, asr ip │ │ │ │ - ldrdeq r8, [r1], -sl │ │ │ │ - andeq r0, r0, ip, lsr #24 │ │ │ │ - andeq r8, r1, ip, lsr #15 │ │ │ │ - muleq r1, r8, r7 │ │ │ │ - andeq r8, r1, r0, ror #2 │ │ │ │ - andeq r8, r1, r8, ror #14 │ │ │ │ + andeq r8, r1, r0, ror r2 │ │ │ │ + andeq r8, r1, ip, ror #16 │ │ │ │ + andeq r8, r1, r2, asr r8 │ │ │ │ + andeq r8, r1, r6, lsr #16 │ │ │ │ + andeq r8, r1, ip, lsl #16 │ │ │ │ + andeq r0, r0, lr, asr ip │ │ │ │ + ldrdeq r8, [r1], -lr │ │ │ │ + andeq r0, r0, r0, lsr ip │ │ │ │ + @ instruction: 0x000187b0 │ │ │ │ + muleq r1, ip, r7 │ │ │ │ + andeq r8, r1, r4, ror #2 │ │ │ │ + andeq r8, r1, ip, ror #14 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0040f8cc │ │ │ │ movwcs fp, #167 @ 0xa7 │ │ │ │ andcs sl, r2, #12, 26 @ 0x300 │ │ │ │ movwls r4, #50692 @ 0xc604 │ │ │ │ movwcc lr, #6597 @ 0x19c5 │ │ │ │ - bmi ff2ac594 <__bss_end__@@Base+0xff28c04c> │ │ │ │ + bmi ff2ac590 <__bss_end__@@Base+0xff28c048> │ │ │ │ ldrbtmi r4, [sl], #-3018 @ 0xfffff436 │ │ │ │ tstls r7, r3, lsl #10 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9325 │ │ │ │ and r0, sp, r0, lsl #6 │ │ │ │ strtmi r2, [r0], -r2, lsl #2 │ │ │ │ - ldmib r0!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldmib r2!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ strtmi r2, [r0], -r2, lsr #2 │ │ │ │ - svc 0x00cef7fa │ │ │ │ + svc 0x00d0f7fa │ │ │ │ @ instruction: 0xf7fb68a0 │ │ │ │ - stmdacs r0, {r3, r8, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r3, r8, fp, sp, lr, pc} │ │ │ │ rschi pc, sl, r0, asr #32 │ │ │ │ @ instruction: 0x2122aa09 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stmdacs r0, {r1, r2, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r3, fp, sp, lr, pc} │ │ │ │ @ instruction: 0x2123d0ea │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - strmi lr, [r1], -r6, ror #18 │ │ │ │ + strmi lr, [r1], -r8, ror #18 │ │ │ │ ldmdage r2, {r9, sp} │ │ │ │ - stmib r4!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmib r6!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ smladcs r0, r2, sl, sl │ │ │ │ @ instruction: 0x97224616 │ │ │ │ movwcs r9, #8705 @ 0x2201 │ │ │ │ @ instruction: 0xf88d4694 │ │ │ │ cdpgt 0, 0, cr3, cr15, cr8, {4} │ │ │ │ stmdaeq r0!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x971ead1e │ │ │ │ @@ -4878,213 +4877,213 @@ │ │ │ │ strgt r0, [pc], -pc │ │ │ │ @ instruction: 0xf8d84656 │ │ │ │ movwls r3, #20480 @ 0x5000 │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ cdpgt 6, 0, cr4, cr15, cr5, {0} │ │ │ │ stmia fp!, {r1, r2, r3, r4, r9, sl, fp, sp, pc} │ │ │ │ - blls 147e4c <__bss_end__@@Base+0x127904> │ │ │ │ + blls 147e48 <__bss_end__@@Base+0x127900> │ │ │ │ andcc pc, r0, lr, asr #17 │ │ │ │ stmia sl!, {r0, r1, r2, r3, r9, sl, fp, lr, pc} │ │ │ │ @ instruction: 0xf8c8000f │ │ │ │ stmdals r2, {ip, lr} │ │ │ │ - svc 0x00fef7fa │ │ │ │ + stmda r0, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf7fa9801 │ │ │ │ - ldrsh lr, [fp], #-252 @ 0xffffff04 │ │ │ │ + ldrsh lr, [fp], #-254 @ 0xffffff02 │ │ │ │ strtmi r2, [r0], -r4, lsl #2 │ │ │ │ - stmdb lr, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldmdb r0, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x21239a09 │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - stmiavs r0!, {r1, r3, r6, fp, sp, lr, pc} │ │ │ │ - stmia r4!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmiavs r0!, {r2, r3, r6, fp, sp, lr, pc} │ │ │ │ + stmia r6!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ @ instruction: 0x212380aa │ │ │ │ @ instruction: 0xf7fb4620 │ │ │ │ - @ instruction: 0x9d01e90a │ │ │ │ + @ instruction: 0x9d01e90c │ │ │ │ andcs r4, r0, #1048576 @ 0x100000 │ │ │ │ @ instruction: 0xf7fb4628 │ │ │ │ - strtmi lr, [lr], -r8, lsl #19 │ │ │ │ + strtmi lr, [lr], -sl, lsl #19 │ │ │ │ ldrdhi pc, [r8], -sp │ │ │ │ cdpeq 1, 7, cr15, cr8, cr13, {0} │ │ │ │ strbmi r9, [r4], r2, lsr #14 │ │ │ │ ldrvc lr, [lr, -sp, asr #19] │ │ │ │ stmib sp, {r0, r1, r2, r3, r9, sl, fp, lr, pc}^ │ │ │ │ stmia ip!, {r5, r8, r9, sl, ip, sp, lr} │ │ │ │ movwcs r0, #8207 @ 0x200f │ │ │ │ @ instruction: 0xf88d9a03 │ │ │ │ strtmi r3, [fp], r8, lsl #1 │ │ │ │ stmdacs r4, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - beq 1e442c0 <__bss_end__@@Base+0x1e23d78> │ │ │ │ + beq 1e442bc <__bss_end__@@Base+0x1e23d74> │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ ldrmi r9, [r5], -r1, lsl #10 │ │ │ │ @ instruction: 0x000fe8be │ │ │ │ andshi pc, r8, sp, asr #17 │ │ │ │ andeq lr, pc, fp, lsr #17 │ │ │ │ ldmdaeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -lr │ │ │ │ - stcgt 0, cr6, [pc, #-204] @ 7de4 <__aeabi_atexit@plt+0x4c30> │ │ │ │ + stcgt 0, cr6, [pc, #-204] @ 7de0 <__aeabi_atexit@plt+0x4c2c> │ │ │ │ andeq lr, pc, sl, lsr #17 │ │ │ │ ldm r5, {r0, r2, r9, sl, fp, ip, pc} │ │ │ │ stm lr, {r0, r1} │ │ │ │ strmi r0, [r6], r3 │ │ │ │ cdpls 14, 0, cr12, cr4, cr15, {0} │ │ │ │ @ instruction: 0xf8dcc60f │ │ │ │ eorvs r1, r9, r0 │ │ │ │ ldm r8!, {r1, r2, r8, sl, fp, ip, pc} │ │ │ │ - strgt r0, [pc, #-15] @ 7ec5 <__aeabi_atexit@plt+0x4d11> │ │ │ │ + strgt r0, [pc, #-15] @ 7ec1 <__aeabi_atexit@plt+0x4d0d> │ │ │ │ @ instruction: 0xf8cc9802 │ │ │ │ @ instruction: 0xf7fae000 │ │ │ │ - stmdals r1, {r1, r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ - svc 0x009ef7fa │ │ │ │ + stmdals r1, {r2, r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + svc 0x00a0f7fa │ │ │ │ stcls 8, cr9, [r9, #-12] │ │ │ │ - stmdb r6, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmdb r8, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ strtmi r4, [sl], -r3, lsl #12 │ │ │ │ strtmi r2, [r0], -r3, lsr #2 │ │ │ │ - stmda r8!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda sl!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ addsle r2, r7, r0, lsl #16 │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ - blls 434630 <__bss_end__@@Base+0x4140e8> │ │ │ │ + blls 43462c <__bss_end__@@Base+0x4140e4> │ │ │ │ movweq pc, #12339 @ 0x3033 @ │ │ │ │ strtmi sp, [r0], -r2, lsl #2 │ │ │ │ - svc 0x00c2f7fa │ │ │ │ + svc 0x00c4f7fa │ │ │ │ @ instruction: 0xf7fb9803 │ │ │ │ - blls 202098 <__bss_end__@@Base+0x1e1b50> │ │ │ │ + blls 20209c <__bss_end__@@Base+0x1e1b54> │ │ │ │ stmdage sl, {r1, r3, ip, pc} │ │ │ │ @ instruction: 0xf7fa6819 │ │ │ │ - blls 203eb4 <__bss_end__@@Base+0x1e396c> │ │ │ │ + blls 203eb8 <__bss_end__@@Base+0x1e3970> │ │ │ │ ldmdavs sp, {r0, r1, fp, ip, pc} │ │ │ │ - stmdb r6!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmdb r8!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ strtmi r4, [r9], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7faa80a │ │ │ │ - stmdals r3, {r1, r2, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ - svc 0x0072f7fa │ │ │ │ - blmi 141a884 <__bss_end__@@Base+0x13fa33c> │ │ │ │ + stmdals r3, {r3, r4, r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + svc 0x0074f7fa │ │ │ │ + blmi 141a880 <__bss_end__@@Base+0x13fa338> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 961fb0 <__bss_end__@@Base+0x941a68> │ │ │ │ + blls 961fac <__bss_end__@@Base+0x941a64> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ eorlt r8, r7, r5, lsl #1 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - blls 203dd0 <__bss_end__@@Base+0x1e3888> │ │ │ │ - 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blmi d32fec <__bss_end__@@Base+0xd12aa4> │ │ │ │ - bls 1d9848 <__bss_end__@@Base+0x1b9300> │ │ │ │ + blmi d32fe8 <__bss_end__@@Base+0xd12aa0> │ │ │ │ + bls 1d9844 <__bss_end__@@Base+0x1b92fc> │ │ │ │ ldmdavs r1, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldrdcc pc, [ip], #131 @ 0x83 │ │ │ │ @ instruction: 0xf7fa930a │ │ │ │ - ldrb lr, [fp, sl, lsl #31] │ │ │ │ - stmda r0!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + ldrb lr, [fp, ip, lsl #31] │ │ │ │ + stmda r2!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ sbcle r2, ip, r0, lsl #16 │ │ │ │ @ instruction: 0xac0a4b2d │ │ │ │ ldrbtmi r2, [fp], #-528 @ 0xfffffdf0 │ │ │ │ movwcs lr, #43469 @ 0xa9cd │ │ │ │ muleq r3, r4, r8 │ │ │ │ - stmia lr, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + ldm r0, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ sbceq pc, r4, r3, asr #17 │ │ │ │ sbceq pc, r0, r3, lsl #2 │ │ │ │ - stmda r2, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ + stmda r4, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0xf7fbe7ba │ │ │ │ - stmdacs r0, {r1, r3, fp, sp, lr, pc} │ │ │ │ - blmi 93c370 <__bss_end__@@Base+0x91be28> │ │ │ │ + stmdacs r0, {r2, r3, fp, sp, lr, pc} │ │ │ │ + blmi 93c36c <__bss_end__@@Base+0x91be24> │ │ │ │ andscs sl, r0, #2560 @ 0xa00 │ │ │ │ stmib sp, {r0, r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ ldm r4, {r1, r3, r8, r9, sp} │ │ │ │ @ instruction: 0xf7fb0003 │ │ │ │ - blmi 842304 <__bss_end__@@Base+0x821dbc> │ │ │ │ + blmi 842308 <__bss_end__@@Base+0x821dc0> │ │ │ │ @ instruction: 0xf8c3447b │ │ │ │ @ instruction: 0xf10300cc │ │ │ │ @ instruction: 0xf7fb00c8 │ │ │ │ - strb lr, [r6, ip, lsr #16] │ │ │ │ + strb lr, [r6, lr, lsr #16] │ │ │ │ @ instruction: 0x46044b1c │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fa00c0 │ │ │ │ - stmdals r3, {r1, r2, r4, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ - mcr 7, 7, pc, cr12, cr10, {7} @ │ │ │ │ - blmi 35a8ac <__bss_end__@@Base+0x33a364> │ │ │ │ + stmdals r3, {r3, r4, r6, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + mcr 7, 7, pc, cr14, cr10, {7} @ │ │ │ │ + blmi 35a8a8 <__bss_end__@@Base+0x33a360> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 9620bc <__bss_end__@@Base+0x941b74> │ │ │ │ + blls 9620b8 <__bss_end__@@Base+0x941b70> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ andle r0, fp, r0, lsl #6 │ │ │ │ - mcr 7, 5, pc, cr14, cr10, {7} @ │ │ │ │ + mrc 7, 5, APSR_nzcv, cr0, cr10, {7} │ │ │ │ strb r4, [lr, r4, lsl #12]! │ │ │ │ @ instruction: 0x46044b12 │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fa00c8 │ │ │ │ - @ instruction: 0xe7e6eebe │ │ │ │ + strb lr, [r6, r0, asr #29]! │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - svclt 0x0000ef02 │ │ │ │ - ldrdeq r8, [r1], -r2 │ │ │ │ + svclt 0x0000ef04 │ │ │ │ + ldrdeq r8, [r1], -r6 │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq r7, r1, r8, ror #29 │ │ │ │ - andeq r8, r1, r4, ror #9 │ │ │ │ - andeq r8, r1, sl, asr #9 │ │ │ │ - muleq r1, lr, r4 │ │ │ │ - andeq r8, r1, r4, lsl #9 │ │ │ │ - ldrdeq r0, [r0], -r6 │ │ │ │ - andeq r8, r1, r6, asr r4 │ │ │ │ - andeq r0, r0, r8, lsr #17 │ │ │ │ - andeq r8, r1, r8, lsr #8 │ │ │ │ - andeq r8, r1, r4, lsl r4 │ │ │ │ - ldrdeq r7, [r1], -ip │ │ │ │ - andeq r8, r1, r4, ror #7 │ │ │ │ + andeq r7, r1, ip, ror #29 │ │ │ │ + andeq r8, r1, r8, ror #9 │ │ │ │ + andeq r8, r1, lr, asr #9 │ │ │ │ + andeq r8, r1, r2, lsr #9 │ │ │ │ + andeq r8, r1, r8, lsl #9 │ │ │ │ + ldrdeq r0, [r0], -sl │ │ │ │ + andeq r8, r1, sl, asr r4 │ │ │ │ + andeq r0, r0, ip, lsr #17 │ │ │ │ + andeq r8, r1, ip, lsr #8 │ │ │ │ + andeq r8, r1, r8, lsl r4 │ │ │ │ + andeq r7, r1, r0, ror #27 │ │ │ │ + andeq r8, r1, r8, ror #7 │ │ │ │ svcmi 0x00f0e92d │ │ │ │ stcpl 4, cr15, [r0], {79} @ 0x4f │ │ │ │ @ instruction: 0x0c0cebad │ │ │ │ svceq 0x0040f8cc │ │ │ │ movwcs fp, #167 @ 0xa7 │ │ │ │ andcs sl, r2, #12, 26 @ 0x300 │ │ │ │ movwls r4, #50692 @ 0xc604 │ │ │ │ movwcc lr, #6597 @ 0x19c5 │ │ │ │ - bmi ff2ac918 <__bss_end__@@Base+0xff28c3d0> │ │ │ │ + bmi ff2ac914 <__bss_end__@@Base+0xff28c3cc> │ │ │ │ ldrbtmi r4, [sl], #-3018 @ 0xfffff436 │ │ │ │ tstls r7, r3, lsl #10 │ │ │ │ ldmdavs fp, {r0, r1, r4, r6, r7, fp, ip, lr} │ │ │ │ @ instruction: 0xf04f9325 │ │ │ │ and r0, sp, r0, lsl #6 │ │ │ │ strtmi r2, [r0], -r2, lsl #2 │ │ │ │ - svc 0x00eef7fa │ │ │ │ + svc 0x00f0f7fa │ │ │ │ strtmi r2, [r0], -r4, lsr #2 │ │ │ │ - svc 0x0030f7fa │ │ │ │ + svc 0x0032f7fa │ │ │ │ @ instruction: 0xf7fa68a0 │ │ │ │ - stmdacs r0, {r1, r2, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r3, r6, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ rschi pc, sl, r0, asr #32 │ │ │ │ @ instruction: 0x2124aa09 │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - stmdacs r0, {r1, r2, r3, r4, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r5, r7, r8, r9, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0x2125d0ea │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - strmi lr, [r1], -r4, lsr #31 │ │ │ │ + strmi lr, [r1], -r6, lsr #31 │ │ │ │ ldmdage r2, {r9, sp} │ │ │ │ - stmda r2!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ + stmda r4!, {r0, r1, r3, r4, r5, r6, r7, r8, r9, sl, ip, sp, lr, pc} │ │ │ │ smladcs r0, r2, sl, sl │ │ │ │ @ instruction: 0x97224616 │ │ │ │ movwcs r9, #8705 @ 0x2201 │ │ │ │ @ instruction: 0xf88d4694 │ │ │ │ cdpgt 0, 0, cr3, cr15, cr8, {4} │ │ │ │ stmdaeq r0!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x971ead1e │ │ │ │ @@ -5103,213 +5102,213 @@ │ │ │ │ strgt r0, [pc], -pc │ │ │ │ @ instruction: 0xf8d84656 │ │ │ │ movwls r3, #20480 @ 0x5000 │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ cdpgt 6, 0, cr4, cr15, cr5, {0} │ │ │ │ stmia fp!, {r1, r2, r3, r4, r9, sl, fp, sp, pc} │ │ │ │ - blls 1481d0 <__bss_end__@@Base+0x127c88> │ │ │ │ + blls 1481cc <__bss_end__@@Base+0x127c84> │ │ │ │ andcc pc, r0, lr, asr #17 │ │ │ │ stmia sl!, {r0, r1, r2, r3, r9, sl, fp, lr, pc} │ │ │ │ @ instruction: 0xf8c8000f │ │ │ │ stmdals r2, {ip, lr} │ │ │ │ - mrc 7, 1, APSR_nzcv, cr12, cr10, {7} │ │ │ │ + mrc 7, 1, APSR_nzcv, cr14, cr10, {7} │ │ │ │ @ instruction: 0xf7fa9801 │ │ │ │ - subs lr, fp, sl, lsr lr │ │ │ │ + subs lr, fp, ip, lsr lr │ │ │ │ strtmi r2, [r0], -r4, lsl #2 │ │ │ │ - svc 0x008cf7fa │ │ │ │ + svc 0x008ef7fa │ │ │ │ @ instruction: 0x21259a09 │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - stmiavs r0!, {r3, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ - mcr 7, 7, pc, cr2, cr10, {7} @ │ │ │ │ + stmiavs r0!, {r1, r3, r7, r9, sl, fp, sp, lr, pc} │ │ │ │ + mcr 7, 7, pc, cr4, cr10, {7} @ │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ @ instruction: 0x212580aa │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - stcls 15, cr14, [r1, #-288] @ 0xfffffee0 │ │ │ │ + stcls 15, cr14, [r1, #-296] @ 0xfffffed8 │ │ │ │ andcs r4, r0, #1048576 @ 0x100000 │ │ │ │ @ instruction: 0xf7fa4628 │ │ │ │ - strtmi lr, [lr], -r6, asr #31 │ │ │ │ + strtmi lr, [lr], -r8, asr #31 │ │ │ │ ldrdhi pc, [r8], -sp │ │ │ │ cdpeq 1, 7, cr15, cr8, cr13, {0} │ │ │ │ strbmi r9, [r4], r2, lsr #14 │ │ │ │ ldrvc lr, [lr, -sp, asr #19] │ │ │ │ stmib sp, {r0, r1, r2, r3, r9, sl, fp, lr, pc}^ │ │ │ │ stmia ip!, {r5, r8, r9, sl, ip, sp, lr} │ │ │ │ movwcs r0, #8207 @ 0x200f │ │ │ │ @ instruction: 0xf88d9a03 │ │ │ │ strtmi r3, [fp], r8, lsl #1 │ │ │ │ stmdacs r4, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - beq 1e44644 <__bss_end__@@Base+0x1e240fc> │ │ │ │ + beq 1e44640 <__bss_end__@@Base+0x1e240f8> │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ ldrmi r9, [r5], -r1, lsl #10 │ │ │ │ @ instruction: 0x000fe8be │ │ │ │ andshi pc, r8, sp, asr #17 │ │ │ │ andeq lr, pc, fp, lsr #17 │ │ │ │ ldmdaeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -lr │ │ │ │ - stcgt 0, cr6, [pc, #-204] @ 8168 <__aeabi_atexit@plt+0x4fb4> │ │ │ │ + stcgt 0, cr6, [pc, #-204] @ 8164 <__aeabi_atexit@plt+0x4fb0> │ │ │ │ andeq lr, pc, sl, lsr #17 │ │ │ │ ldm r5, {r0, r2, r9, sl, fp, ip, pc} │ │ │ │ stm lr, {r0, r1} │ │ │ │ strmi r0, [r6], r3 │ │ │ │ cdpls 14, 0, cr12, cr4, cr15, {0} │ │ │ │ @ instruction: 0xf8dcc60f │ │ │ │ eorvs r1, r9, r0 │ │ │ │ ldm r8!, {r1, r2, r8, sl, fp, ip, pc} │ │ │ │ - strgt r0, [pc, #-15] @ 8249 <__aeabi_atexit@plt+0x5095> │ │ │ │ + strgt r0, [pc, #-15] @ 8245 <__aeabi_atexit@plt+0x5091> │ │ │ │ @ instruction: 0xf8cc9802 │ │ │ │ @ instruction: 0xf7fae000 │ │ │ │ - stmdals r1, {r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ - ldcl 7, cr15, [ip, #1000] @ 0x3e8 │ │ │ │ + stmdals r1, {r1, r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + ldcl 7, cr15, [lr, #1000] @ 0x3e8 │ │ │ │ stcls 8, cr9, [r9, #-12] │ │ │ │ - svc 0x0084f7fa │ │ │ │ + svc 0x0086f7fa │ │ │ │ strtmi r4, [sl], -r3, lsl #12 │ │ │ │ strtmi r2, [r0], -r5, lsr #2 │ │ │ │ - mcr 7, 5, pc, cr6, cr10, {7} @ │ │ │ │ + mcr 7, 5, pc, cr8, cr10, {7} @ │ │ │ │ addsle r2, r7, r0, lsl #16 │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ - blls 4349b4 <__bss_end__@@Base+0x41446c> │ │ │ │ + blls 4349b0 <__bss_end__@@Base+0x414468> │ │ │ │ movweq pc, #12339 @ 0x3033 @ │ │ │ │ strtmi sp, [r0], -r2, lsl #2 │ │ │ │ - mcr 7, 0, pc, cr0, cr10, {7} @ │ │ │ │ + mcr 7, 0, pc, cr2, cr10, {7} @ │ │ │ │ @ instruction: 0xf7fa9803 │ │ │ │ - blls 203d14 <__bss_end__@@Base+0x1e37cc> │ │ │ │ + blls 203d18 <__bss_end__@@Base+0x1e37d0> │ │ │ │ stmdage sl, {r1, r3, ip, pc} │ │ │ │ @ instruction: 0xf7fa6819 │ │ │ │ - blls 203b30 <__bss_end__@@Base+0x1e35e8> │ │ │ │ + blls 203b34 <__bss_end__@@Base+0x1e35ec> │ │ │ │ ldmdavs sp, {r0, r1, fp, ip, pc} │ │ │ │ - svc 0x0064f7fa │ │ │ │ + svc 0x0066f7fa │ │ │ │ strtmi r4, [r9], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7faa80a │ │ │ │ - stmdals r3, {r2, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ - ldc 7, cr15, [r0, #1000]! @ 0x3e8 │ │ │ │ - blmi 141ac08 <__bss_end__@@Base+0x13fa6c0> │ │ │ │ + stmdals r3, {r1, r2, r4, r5, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + ldc 7, cr15, [r2, #1000]! @ 0x3e8 │ │ │ │ + blmi 141ac04 <__bss_end__@@Base+0x13fa6bc> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 962334 <__bss_end__@@Base+0x941dec> │ │ │ │ + blls 962330 <__bss_end__@@Base+0x941de8> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ eorlt r8, r7, r5, lsl #1 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - blls 203a4c <__bss_end__@@Base+0x1e3504> │ │ │ │ - blcs 22354 <__bss_end__@@Base+0x1e0c> │ │ │ │ - blmi 123c688 <__bss_end__@@Base+0x121c140> │ │ │ │ + blls 203a50 <__bss_end__@@Base+0x1e3508> │ │ │ │ + blcs 22350 <__bss_end__@@Base+0x1e08> │ │ │ │ + blmi 123c684 <__bss_end__@@Base+0x121c13c> │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf8d300d0 │ │ │ │ vshr.u64 , q0, #1 │ │ │ │ @ instruction: 0x07da8f5b │ │ │ │ stcge 5, cr13, [sl], {46} @ 0x2e │ │ │ │ strtmi r4, [r0], -r3, asr #22 │ │ │ │ ldrbtmi r9, [fp], #-2567 @ 0xfffff5f9 │ │ │ │ @ instruction: 0xf8d36811 │ │ │ │ movwls r3, #41172 @ 0xa0d4 │ │ │ │ - stcl 7, cr15, [sl, #1000]! @ 0x3e8 │ │ │ │ + stcl 7, cr15, [ip, #1000]! @ 0x3e8 │ │ │ │ andcs r9, r0, #7168 @ 0x1c00 │ │ │ │ ldmdavs r9, {r5, r9, sl, lr} │ │ │ │ - stcl 7, cr15, [r0, #1000] @ 0x3e8 │ │ │ │ + stcl 7, cr15, [r2, #1000] @ 0x3e8 │ │ │ │ strtmi lr, [r0], -fp, asr #15 │ │ │ │ - ldc 7, cr15, [r6, #1000]! @ 0x3e8 │ │ │ │ + ldc 7, cr15, [r8, #1000]! @ 0x3e8 │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ sbcle r2, r4, r0, lsl #22 │ │ │ │ ldrbtmi r4, [fp], #-2872 @ 0xfffff4c8 │ │ │ │ sbcseq pc, r8, r3, lsl #2 │ │ │ │ ldrsbcc pc, [r8], #131 @ 0x83 @ │ │ │ │ svchi 0x005bf3bf │ │ │ │ strle r0, [r2, #-2011]! @ 0xfffff825 │ │ │ │ - blmi d33370 <__bss_end__@@Base+0xd12e28> │ │ │ │ - bls 1d9bcc <__bss_end__@@Base+0x1b9684> │ │ │ │ + blmi d3336c <__bss_end__@@Base+0xd12e24> │ │ │ │ + bls 1d9bc8 <__bss_end__@@Base+0x1b9680> │ │ │ │ ldmdavs r1, {r0, r1, r3, r4, r5, r6, sl, lr} │ │ │ │ ldrsbcc pc, [ip], #131 @ 0x83 @ │ │ │ │ @ instruction: 0xf7fa930a │ │ │ │ - ldrb lr, [fp, r8, asr #27] │ │ │ │ - mrc 7, 2, APSR_nzcv, cr14, cr10, {7} │ │ │ │ + ldrb lr, [fp, sl, asr #27] │ │ │ │ + mcr 7, 3, pc, cr0, cr10, {7} @ │ │ │ │ sbcle r2, ip, r0, lsl #16 │ │ │ │ @ instruction: 0xac0a4b2d │ │ │ │ ldrbtmi r2, [fp], #-528 @ 0xfffffdf0 │ │ │ │ movwcs lr, #43469 @ 0xa9cd │ │ │ │ muleq r3, r4, r8 │ │ │ │ - svc 0x000cf7fa │ │ │ │ + svc 0x000ef7fa │ │ │ │ ldrbtmi r4, [fp], #-2857 @ 0xfffff4d7 │ │ │ │ sbcseq pc, r4, r3, asr #17 │ │ │ │ sbcseq pc, r0, r3, lsl #2 │ │ │ │ - mcr 7, 4, pc, cr0, cr10, {7} @ │ │ │ │ + mcr 7, 4, pc, cr2, cr10, {7} @ │ │ │ │ @ instruction: 0xf7fae7ba │ │ │ │ - stmdacs r0, {r3, r6, r9, sl, fp, sp, lr, pc} │ │ │ │ - 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blls 962440 <__bss_end__@@Base+0x941ef8> │ │ │ │ + blls 96243c <__bss_end__@@Base+0x941ef4> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ andle r0, fp, r0, lsl #6 │ │ │ │ - stcl 7, cr15, [ip], #1000 @ 0x3e8 │ │ │ │ + stcl 7, cr15, [lr], #1000 @ 0x3e8 │ │ │ │ strb r4, [lr, r4, lsl #12]! │ │ │ │ @ instruction: 0x46044b12 │ │ │ │ @ instruction: 0xf103447b │ │ │ │ @ instruction: 0xf7fa00d8 │ │ │ │ - @ instruction: 0xe7e6ecfc │ │ │ │ + @ instruction: 0xe7e6ecfe │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - svclt 0x0000ed40 │ │ │ │ - andeq r7, r1, lr, asr #26 │ │ │ │ + svclt 0x0000ed42 │ │ │ │ + andeq r7, r1, r2, asr sp │ │ │ │ ldrdeq r0, [r0], -r0 @ │ │ │ │ - andeq r7, r1, r4, ror #22 │ │ │ │ - andeq r8, r1, r0, ror #2 │ │ │ │ - andeq r8, r1, r6, asr #2 │ │ │ │ - andeq r8, r1, sl, lsl r1 │ │ │ │ - andeq r8, r1, r0, lsl #2 │ │ │ │ - andeq r0, r0, r2, asr r5 │ │ │ │ - ldrdeq r8, [r1], -r2 │ │ │ │ - andeq r0, r0, r4, lsr #10 │ │ │ │ - andeq r8, r1, r4, lsr #1 │ │ │ │ - muleq r1, r0, r0 │ │ │ │ - andeq r7, r1, r8, asr sl │ │ │ │ - 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mcr 7, 1, pc, cr12, cr10, {7} @ │ │ │ │ + mcr 7, 1, pc, cr14, cr10, {7} @ │ │ │ │ strtmi r2, [r0], -r6, lsr #2 │ │ │ │ - stcl 7, cr15, [lr, #-1000]! @ 0xfffffc18 │ │ │ │ + ldcl 7, cr15, [r0, #-1000]! @ 0xfffffc18 │ │ │ │ @ instruction: 0xf7fa68a0 │ │ │ │ - stmdacs r0, {r2, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ rschi pc, sl, r0, asr #32 │ │ │ │ @ instruction: 0x2126aa09 │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - stmdacs r0, {r2, r3, r4, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ + stmdacs r0, {r1, r2, r3, r4, r6, r7, r8, sl, fp, sp, lr, pc} │ │ │ │ @ instruction: 0x2127d0ea │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - strmi lr, [r1], -r2, ror #27 │ │ │ │ + strmi lr, [r1], -r4, ror #27 │ │ │ │ ldmdage r2, {r9, sp} │ │ │ │ - mcr 7, 3, pc, cr0, cr10, {7} @ │ │ │ │ + mcr 7, 3, pc, cr2, cr10, {7} @ │ │ │ │ smladcs r0, r2, sl, sl │ │ │ │ @ instruction: 0x97224616 │ │ │ │ movwcs r9, #8705 @ 0x2201 │ │ │ │ @ instruction: 0xf88d4694 │ │ │ │ cdpgt 0, 0, cr3, cr15, cr8, {4} │ │ │ │ stmdaeq r0!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ @ instruction: 0x971ead1e │ │ │ │ @@ -5328,177 +5327,177 @@ │ │ │ │ strgt r0, [pc], -pc │ │ │ │ @ instruction: 0xf8d84656 │ │ │ │ movwls r3, #20480 @ 0x5000 │ │ │ │ muleq r3, lr, r8 │ │ │ │ andeq lr, r3, r5, lsl #17 │ │ │ │ cdpgt 6, 0, cr4, cr15, cr5, {0} │ │ │ │ stmia fp!, {r1, r2, r3, r4, r9, sl, fp, sp, pc} │ │ │ │ - blls 148554 <__bss_end__@@Base+0x12800c> │ │ │ │ + blls 148550 <__bss_end__@@Base+0x128008> │ │ │ │ andcc pc, r0, lr, asr #17 │ │ │ │ stmia sl!, {r0, r1, r2, r3, r9, sl, fp, lr, pc} │ │ │ │ @ instruction: 0xf8c8000f │ │ │ │ stmdals r2, {ip, lr} │ │ │ │ - ldcl 7, cr15, [sl], #-1000 @ 0xfffffc18 │ │ │ │ + ldcl 7, cr15, [ip], #-1000 @ 0xfffffc18 │ │ │ │ @ instruction: 0xf7fa9801 │ │ │ │ - subs lr, fp, r8, ror ip │ │ │ │ + subs lr, fp, sl, ror ip │ │ │ │ strtmi r2, [r0], -r4, lsl #2 │ │ │ │ - stcl 7, cr15, [sl, #1000] @ 0x3e8 │ │ │ │ + stcl 7, cr15, [ip, #1000] @ 0x3e8 │ │ │ │ @ instruction: 0x21279a09 │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - stmiavs r0!, {r1, r2, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ - stc 7, cr15, [r0, #-1000]! @ 0xfffffc18 │ │ │ │ + stmiavs r0!, {r3, r6, r7, sl, fp, sp, lr, pc} │ │ │ │ + stc 7, cr15, [r2, #-1000]! @ 0xfffffc18 │ │ │ │ @ instruction: 0xf0402800 │ │ │ │ @ instruction: 0x212780aa │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - stcls 13, cr14, [r1, #-536] @ 0xfffffde8 │ │ │ │ + stcls 13, cr14, [r1, #-544] @ 0xfffffde0 │ │ │ │ andcs r4, r0, #1048576 @ 0x100000 │ │ │ │ @ instruction: 0xf7fa4628 │ │ │ │ - strtmi lr, [lr], -r4, lsl #28 │ │ │ │ + strtmi lr, [lr], -r6, lsl #28 │ │ │ │ ldrdhi pc, [r8], -sp │ │ │ │ cdpeq 1, 7, cr15, cr8, cr13, {0} │ │ │ │ strbmi r9, [r4], r2, lsr #14 │ │ │ │ ldrvc lr, [lr, -sp, asr #19] │ │ │ │ stmib sp, {r0, r1, r2, r3, r9, sl, fp, lr, pc}^ │ │ │ │ stmia ip!, {r5, r8, r9, sl, ip, sp, lr} │ │ │ │ movwcs r0, #8207 @ 0x200f │ │ │ │ @ instruction: 0xf88d9a03 │ │ │ │ strtmi r3, [fp], r8, lsl #1 │ │ │ │ stmdacs r4, {r0, r2, r3, r6, r7, r8, fp, sp, lr, pc} │ │ │ │ - beq 1e449c8 <__bss_end__@@Base+0x1e24480> │ │ │ │ + beq 1e449c4 <__bss_end__@@Base+0x1e2447c> │ │ │ │ muleq r3, r6, r8 │ │ │ │ andeq lr, r3, ip, lsl #17 │ │ │ │ ldrmi r9, [r5], -r1, lsl #10 │ │ │ │ @ instruction: 0x000fe8be │ │ │ │ andshi pc, r8, sp, asr #17 │ │ │ │ andeq lr, pc, fp, lsr #17 │ │ │ │ ldmdaeq r8!, {r0, r2, r3, r8, ip, sp, lr, pc}^ │ │ │ │ ldrdcc pc, [r0], -lr │ │ │ │ - stcgt 0, cr6, [pc, #-204] @ 84ec <__aeabi_atexit@plt+0x5338> │ │ │ │ + stcgt 0, cr6, [pc, #-204] @ 84e8 <__aeabi_atexit@plt+0x5334> │ │ │ │ andeq lr, pc, sl, lsr #17 │ │ │ │ ldm r5, {r0, r2, r9, sl, fp, ip, pc} │ │ │ │ stm lr, {r0, r1} │ │ │ │ strmi r0, [r6], r3 │ │ │ │ cdpls 14, 0, cr12, cr4, cr15, {0} │ │ │ │ @ instruction: 0xf8dcc60f │ │ │ │ eorvs r1, r9, r0 │ │ │ │ ldm r8!, {r1, r2, r8, sl, fp, ip, pc} │ │ │ │ - strgt r0, [pc, #-15] @ 85cd <__aeabi_atexit@plt+0x5419> │ │ │ │ + strgt r0, [pc, #-15] @ 85c9 <__aeabi_atexit@plt+0x5415> │ │ │ │ @ instruction: 0xf8cc9802 │ │ │ │ @ instruction: 0xf7fae000 │ │ │ │ - stmdals r1, {r1, r2, r3, r4, sl, fp, sp, lr, pc} │ │ │ │ - ldc 7, cr15, [sl], {250} @ 0xfa │ │ │ │ + stmdals r1, {r5, sl, fp, sp, lr, pc} │ │ │ │ + ldc 7, cr15, [ip], {250} @ 0xfa │ │ │ │ stcls 8, cr9, [r9, #-12] │ │ │ │ - stcl 7, cr15, [r2, #1000] @ 0x3e8 │ │ │ │ + stcl 7, cr15, [r4, #1000] @ 0x3e8 │ │ │ │ strtmi r4, [sl], -r3, lsl #12 │ │ │ │ strtmi r2, [r0], -r7, lsr #2 │ │ │ │ - stcl 7, cr15, [r4], #1000 @ 0x3e8 │ │ │ │ + stcl 7, cr15, [r6], #1000 @ 0x3e8 │ │ │ │ addsle r2, r7, r0, lsl #16 │ │ │ │ ldmdavs fp, {r0, r1, r2, r8, r9, fp, ip, pc} │ │ │ │ - blls 434d38 <__bss_end__@@Base+0x4147f0> │ │ │ │ + blls 434d34 <__bss_end__@@Base+0x4147ec> │ │ │ │ movweq pc, #12339 @ 0x3033 @ │ │ │ │ strtmi sp, [r0], -r2, lsl #2 │ │ │ │ - ldc 7, cr15, [lr], #-1000 @ 0xfffffc18 │ │ │ │ + mcrr 7, 15, pc, r0, cr10 @ │ │ │ │ @ instruction: 0xf7fa9803 │ │ │ │ - blls 203990 <__bss_end__@@Base+0x1e3448> │ │ │ │ + blls 203994 <__bss_end__@@Base+0x1e344c> │ │ │ │ stmdage sl, {r1, r3, ip, pc} │ │ │ │ @ instruction: 0xf7fa6819 │ │ │ │ - blls 2037ac <__bss_end__@@Base+0x1e3264> │ │ │ │ + blls 2037b0 <__bss_end__@@Base+0x1e3268> │ │ │ │ ldmdavs sp, {r0, r1, fp, ip, pc} │ │ │ │ - stc 7, cr15, [r2, #1000]! @ 0x3e8 │ │ │ │ + stc 7, cr15, [r4, #1000]! @ 0x3e8 │ │ │ │ strtmi r4, [r9], -r2, lsl #12 │ │ │ │ @ instruction: 0xf7faa80a │ │ │ │ - stmdals r3, {r1, r4, r5, sl, fp, sp, lr, pc} │ │ │ │ - bl ffbc662c <__bss_end__@@Base+0xffba60e4> │ │ │ │ - blmi 141af8c <__bss_end__@@Base+0x13faa44> │ │ │ │ + stmdals r3, {r2, r4, r5, sl, fp, sp, lr, pc} │ │ │ │ + bl ffc46628 <__bss_end__@@Base+0xffc260e0> │ │ │ │ + blmi 141af88 <__bss_end__@@Base+0x13faa40> │ │ │ │ ldmpl r3, {r1, r3, r4, r5, r6, sl, lr}^ │ │ │ │ - blls 9626b8 <__bss_end__@@Base+0x942170> │ │ │ │ + blls 9626b4 <__bss_end__@@Base+0x94216c> │ │ │ │ @ instruction: 0xf04f405a │ │ │ │ @ instruction: 0xf0400300 │ │ │ │ eorlt r8, r7, r5, lsl #1 │ │ │ │ svchi 0x00f0e8bd │ │ │ │ @ instruction: 0xf7fa4620 │ │ │ │ - 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