--- /srv/rebuilderd/tmp/rebuilderdyUja3J/inputs/libphobos2-ldc-shared110_1.40.0-5_armhf.deb
+++ /srv/rebuilderd/tmp/rebuilderdyUja3J/out/libphobos2-ldc-shared110_1.40.0-5_armhf.deb
├── file list
│ @@ -1,3 +1,3 @@
│  -rw-r--r--   0        0        0        4 2025-02-08 15:59:58.000000 debian-binary
│  -rw-r--r--   0        0        0     1020 2025-02-08 15:59:58.000000 control.tar.xz
│ --rw-r--r--   0        0        0  1051820 2025-02-08 15:59:58.000000 data.tar.xz
│ +-rw-r--r--   0        0        0  1052296 2025-02-08 15:59:58.000000 data.tar.xz
├── control.tar.xz
│ ├── control.tar
│ │ ├── ./md5sums
│ │ │ ├── ./md5sums
│ │ │ │┄ Files differ
├── data.tar.xz
│ ├── data.tar
│ │ ├── ./usr/lib/arm-linux-gnueabihf/libdruntime-ldc-shared.so.110.0
│ │ │┄ File has been modified after NT_GNU_BUILD_ID has been applied.
│ │ │ ├── readelf --wide --notes {}
│ │ │ │ @@ -1,4 +1,4 @@
│ │ │ │  
│ │ │ │  Displaying notes found in: .note.gnu.build-id
│ │ │ │    Owner                Data size 	Description
│ │ │ │ -  GNU                  0x00000014	NT_GNU_BUILD_ID (unique build ID bitstring)	    Build ID: beb5a2dd91f4faceb52b6008aacbfae7b83a557a
│ │ │ │ +  GNU                  0x00000014	NT_GNU_BUILD_ID (unique build ID bitstring)	    Build ID: c1f43a47f16db49b248d413d9711aabb2c0ef70a
│ │ │ ├── strings --all --bytes=8 {}
│ │ │ │┄ Ordering differences only
│ │ │ │ @@ -4831,17 +4831,17 @@
│ │ │ │  <unknown dir>
│ │ │ │  <unknown file>
│ │ │ │  .debug_line
│ │ │ │  /proc/self/exe
│ │ │ │  core.cpuid
│ │ │ │  DFNbMxPvZk
│ │ │ │  %%%uf%%n
│ │ │ │ +an identifier
│ │ │ │  with suffix
│ │ │ │  a number
│ │ │ │ -an identifier
│ │ │ │  parallel
│ │ │ │  incPoolSize
│ │ │ │  initReserve
│ │ │ │  maxPoolSize
│ │ │ │  minPoolSize
│ │ │ │  heapSizeFactor
│ │ │ │  finalize
│ │ │ │ @@ -4853,19 +4853,19 @@
│ │ │ │  core/runtime.d
│ │ │ │  bad exception
│ │ │ │  bad allocation
│ │ │ │  bad cast
│ │ │ │  bad typeid
│ │ │ │  bootTime
│ │ │ │  processCPUTime
│ │ │ │ -threadCPUTime
│ │ │ │  core/time.d
│ │ │ │  MonoTime(
│ │ │ │   ticks, 
│ │ │ │  0 hnsecs
│ │ │ │ +threadCPUTime
│ │ │ │  object.d
│ │ │ │  object.Object
│ │ │ │  object.TypeInfo
│ │ │ │  TypeInfo_Enum
│ │ │ │  TypeInfo_Array
│ │ │ │  TypeInfo_Vector
│ │ │ │  TypeInfo_Class
│ │ │ │ @@ -4973,14 +4973,15 @@
│ │ │ │  FNbNiC4core6thread10threadbase10ThreadBaseZQBm
│ │ │ │  FNbNiC4core6thread10threadbase10ThreadBaseZv
│ │ │ │  core.demangle.Demangle!(NoHooks).Demangle.AddType
│ │ │ │  S4core8demangle7NoHooks
│ │ │ │  FNbNiAyakQeQgmZv
│ │ │ │  FMDFyPS6object10ModuleInfoZiZi
│ │ │ │  core.exception.RangeError
│ │ │ │ +] is out of bounds for array of length 
│ │ │ │  core/exception.d
│ │ │ │  core.exception.ArrayIndexError
│ │ │ │  has a larger lower index than upper index
│ │ │ │  extends past source array of length 
│ │ │ │  core.exception.ArraySliceError
│ │ │ │  Assertion failure
│ │ │ │  core.exception.AssertError
│ │ │ │ @@ -4993,15 +4994,14 @@
│ │ │ │  core.exception.InvalidMemoryOperationError
│ │ │ │  core.exception.ForkError
│ │ │ │  core.exception.SwitchError
│ │ │ │  core.exception.UnicodeException
│ │ │ │  unittest failure
│ │ │ │  core.exception.SuppressTraceInfo
│ │ │ │  No appropriate switch clause found
│ │ │ │ -] is out of bounds for array of length 
│ │ │ │  GC options are specified as white space separated assignments:
│ │ │ │      disable:0|1    - start disabled (%d)
│ │ │ │      fork:0|1       - set fork behaviour (%d)
│ │ │ │      profile:0|1|2  - enable profiling with summary when terminating program (%d)
│ │ │ │   - select gc implementation (default = conservative)
│ │ │ │      initReserve:N  - initial memory to reserve in MB (%lld%c)
│ │ │ │      minPoolSize:N  - initial and minimum pool size in MB (%lld%c)
│ │ │ ├── objdump --line-numbers --disassemble --demangle --reloc --no-show-raw-insn --section=.text {}
│ │ │ │ @@ -4714,15 +4714,15 @@
│ │ │ │  	beq	7e5ec <_D4core8demangle__T8DemangleTSQBcQBa15reencodeMangledFNaNbNfNkMAxaZ12PrependHooksZQCl8putCommaMFNaNbNfkZv@@Base+0x18>
│ │ │ │  	bx	lr
│ │ │ │  	ldr	r2, [pc, #12]	@ 7e600 <_D4core8demangle__T8DemangleTSQBcQBa15reencodeMangledFNaNbNfNkMAxaZ12PrependHooksZQCl8putCommaMFNaNbNfkZv@@Base+0x2c>
│ │ │ │  	add	r0, r0, #8
│ │ │ │  	mov	r1, #2
│ │ │ │  	add	r2, pc, r2
│ │ │ │  	b	7888c <core.demangle.Buffer.append(scope const(char)[])@plt>
│ │ │ │ -	andeq	sl, r5, lr, asr #26
│ │ │ │ +	andeq	sl, r5, r9, lsr sp
│ │ │ │  
│ │ │ │  0007e604 <_D4core8demangle__T8DemangleTSQBcQBa15reencodeMangledFNaNbNfNkMAxaZ12PrependHooksZQCl3putMFNaNbNjNlNfMQBnZv@@Base>:
│ │ │ │  	ldrb	r3, [r0, #32]
│ │ │ │  	tst	r3, #1
│ │ │ │  	bxne	lr
│ │ │ │  	add	r0, r0, #8
│ │ │ │  	b	7888c <core.demangle.Buffer.append(scope const(char)[])@plt>
│ │ │ │ @@ -7401,15 +7401,15 @@
│ │ │ │  	add	r2, pc, r2
│ │ │ │  	bl	7888c <core.demangle.Buffer.append(scope const(char)[])@plt>
│ │ │ │  	add	sp, sp, #84	@ 0x54
│ │ │ │  	pop	{r4, r5, r6, r7, r8, r9, sl, fp, pc}
│ │ │ │  	add	r0, r0, #1
│ │ │ │  	str	r0, [r5, #20]
│ │ │ │  	udf	#65006	@ 0xfdee
│ │ │ │ -	andeq	r8, r5, lr, asr #18
│ │ │ │ +	andeq	r8, r5, r9, lsr r9
│ │ │ │  	andeq	r8, r5, r0, lsr #1
│ │ │ │  	andeq	r8, r5, r6, asr #1
│ │ │ │  	andeq	r8, r5, ip, lsl #30
│ │ │ │  	andeq	r8, r5, r0, lsr #23
│ │ │ │  	andeq	r8, r5, r8, asr r4
│ │ │ │  	andeq	r8, r5, r4, asr #8
│ │ │ │  	andeq	r8, r5, r0, lsl #24
│ │ │ │ @@ -8304,17 +8304,17 @@
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	mov	r0, #15
│ │ │ │  	mov	r3, sl
│ │ │ │  	strd	r8, [sp]
│ │ │ │  	bl	78454 <_d_arraybounds_slice@plt>
│ │ │ │  	andeq	r7, r5, r2, asr sp
│ │ │ │  	strdeq	r7, [r5], -fp
│ │ │ │ -	andeq	r7, r5, sl, asr #14
│ │ │ │ -	andeq	r7, r5, r6, lsl #27
│ │ │ │ -	andeq	r7, r5, r6, asr #16
│ │ │ │ +	andeq	r7, r5, r5, lsr r7
│ │ │ │ +	andeq	r7, r5, r1, ror sp
│ │ │ │ +	andeq	r7, r5, r1, lsr r8
│ │ │ │  	andeq	r7, r5, r4, lsr r1
│ │ │ │  	andeq	r7, r5, r4, lsl r1
│ │ │ │  
│ │ │ │  00081d24 <_D4core8demangle__T8DemangleTSQBcQBa15reencodeMangledFNaNbNfNkMAxaZ12PrependHooksZQCl10parseValueMFNaNbNlNfJbMSQEfQEd8BufSliceaZ7onErrorMFNaNbNiNfZv@@Base>:
│ │ │ │  	ldr	r0, [r0]
│ │ │ │  	mov	r1, #1
│ │ │ │  	strb	r1, [r0]
│ │ │ │ @@ -9818,20 +9818,20 @@
│ │ │ │  	mov	r2, #99	@ 0x63
│ │ │ │  	str	r0, [sp]
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	orr	r2, r2, #3072	@ 0xc00
│ │ │ │  	mov	r0, #15
│ │ │ │  	bl	7816c <_d_arraybounds_index@plt>
│ │ │ │  	stclgt	12, cr12, [ip], {205}	@ 0xcd
│ │ │ │ -	andeq	r6, r5, lr, ror #11
│ │ │ │ -	andeq	r6, r5, r2, asr #10
│ │ │ │ -	andeq	r6, r5, r6, lsr #16
│ │ │ │ +	ldrdeq	r6, [r5], -r9
│ │ │ │ +	andeq	r6, r5, sp, lsr #10
│ │ │ │ +	andeq	r6, r5, r1, lsl r8
│ │ │ │  	andeq	r5, r5, r4, asr #19
│ │ │ │  	andeq	r5, r5, r4, lsr #19
│ │ │ │ -	muleq	r5, lr, r5
│ │ │ │ +	andeq	r6, r5, r9, lsl #11
│ │ │ │  	strdeq	r5, [r5], -r8
│ │ │ │  	andeq	r5, r5, r0, ror #19
│ │ │ │  	andeq	r5, r5, r4, lsl #19
│ │ │ │  
│ │ │ │  000834bc <_D4core8demangle__T8DemangleTSQBcQBa15reencodeMangledFNaNbNfNkMAxaZ12PrependHooksZQCl19mayBeMangledNameArgMFNaNbNiNfZb@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, r8, lr}
│ │ │ │  	sub	sp, sp, #8
│ │ │ │ @@ -14319,15 +14319,15 @@
│ │ │ │  	beq	877f8 <core.demangle.Demangle!(core.demangle.NoHooks).Demangle.putComma(uint)@@Base+0x18>
│ │ │ │  	bx	lr
│ │ │ │  	ldr	r2, [pc, #12]	@ 8780c <core.demangle.Demangle!(core.demangle.NoHooks).Demangle.putComma(uint)@@Base+0x2c>
│ │ │ │  	add	r0, r0, #8
│ │ │ │  	mov	r1, #2
│ │ │ │  	add	r2, pc, r2
│ │ │ │  	b	7888c <core.demangle.Buffer.append(scope const(char)[])@plt>
│ │ │ │ -	andeq	r1, r5, r2, asr #22
│ │ │ │ +	andeq	r1, r5, sp, lsr #22
│ │ │ │  
│ │ │ │  00087810 <core.demangle.Demangle!(core.demangle.NoHooks).Demangle.put(scope const(char)[])@@Base>:
│ │ │ │  	ldrb	r3, [r0, #32]
│ │ │ │  	tst	r3, #1
│ │ │ │  	bxne	lr
│ │ │ │  	add	r0, r0, #8
│ │ │ │  	b	7888c <core.demangle.Buffer.append(scope const(char)[])@plt>
│ │ │ │ @@ -17214,15 +17214,15 @@
│ │ │ │  	add	r2, pc, r2
│ │ │ │  	bl	7888c <core.demangle.Buffer.append(scope const(char)[])@plt>
│ │ │ │  	add	sp, sp, #84	@ 0x54
│ │ │ │  	pop	{r4, r5, r6, r7, r8, r9, sl, fp, pc}
│ │ │ │  	add	r0, r0, #1
│ │ │ │  	str	r0, [r5, #20]
│ │ │ │  	udf	#65006	@ 0xfdee
│ │ │ │ -	andeq	pc, r4, r2, lsr #8
│ │ │ │ +	andeq	pc, r4, sp, lsl #8
│ │ │ │  	andeq	lr, r4, r4, ror fp
│ │ │ │  	muleq	r4, sl, fp
│ │ │ │  	andeq	pc, r4, r0, ror #19
│ │ │ │  	andeq	pc, r4, r4, ror r6	@ <UNPREDICTABLE>
│ │ │ │  	andeq	lr, r4, ip, lsr #30
│ │ │ │  	andeq	lr, r4, r8, lsl pc
│ │ │ │  	ldrdeq	pc, [r4], -r4
│ │ │ │ @@ -18117,17 +18117,17 @@
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	mov	r0, #15
│ │ │ │  	mov	r3, sl
│ │ │ │  	strd	r8, [sp]
│ │ │ │  	bl	78454 <_d_arraybounds_slice@plt>
│ │ │ │  	andeq	lr, r4, r6, lsr #16
│ │ │ │  	andeq	lr, r4, pc, asr #3
│ │ │ │ -	andeq	lr, r4, lr, lsl r2
│ │ │ │ -	andeq	lr, r4, sl, asr r8
│ │ │ │ -	andeq	lr, r4, sl, lsl r3
│ │ │ │ +	andeq	lr, r4, r9, lsl #4
│ │ │ │ +	andeq	lr, r4, r5, asr #16
│ │ │ │ +	andeq	lr, r4, r5, lsl #6
│ │ │ │  	andeq	sp, r4, r8, lsl #24
│ │ │ │  	andeq	sp, r4, r8, ror #23
│ │ │ │  
│ │ │ │  0008b250 <core.demangle.Demangle!(core.demangle.NoHooks).Demangle.parseValue(out bool, scope core.demangle.BufSlice, char).onError()@@Base>:
│ │ │ │  	ldr	r0, [r0]
│ │ │ │  	mov	r1, #1
│ │ │ │  	strb	r1, [r0]
│ │ │ │ @@ -19631,20 +19631,20 @@
│ │ │ │  	mov	r2, #99	@ 0x63
│ │ │ │  	str	r0, [sp]
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	orr	r2, r2, #3072	@ 0xc00
│ │ │ │  	mov	r0, #15
│ │ │ │  	bl	7816c <_d_arraybounds_index@plt>
│ │ │ │  	stclgt	12, cr12, [ip], {205}	@ 0xcd
│ │ │ │ -	andeq	sp, r4, r2, asr #1
│ │ │ │ -	andeq	sp, r4, r6, lsl r0
│ │ │ │ -	strdeq	sp, [r4], -sl
│ │ │ │ +	andeq	sp, r4, sp, lsr #1
│ │ │ │ +	andeq	sp, r4, r1
│ │ │ │ +	andeq	sp, r4, r5, ror #5
│ │ │ │  	muleq	r4, r8, r4
│ │ │ │  	andeq	ip, r4, r8, ror r4
│ │ │ │ -	andeq	sp, r4, r2, ror r0
│ │ │ │ +	andeq	sp, r4, sp, asr r0
│ │ │ │  	andeq	ip, r4, ip, asr #9
│ │ │ │  			@ <UNDEFINED> instruction: 0x0004c4b4
│ │ │ │  	andeq	ip, r4, r8, asr r4
│ │ │ │  
│ │ │ │  0008c9e8 <core.demangle.Demangle!(core.demangle.NoHooks).Demangle.mayBeMangledNameArg()@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, r8, lr}
│ │ │ │  	sub	sp, sp, #8
│ │ │ │ @@ -21968,19 +21968,19 @@
│ │ │ │  	stm	sp, {r2, r7}
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	mov	r0, #16
│ │ │ │  	mov	r2, #102	@ 0x66
│ │ │ │  	mov	r3, #0
│ │ │ │  	bl	78454 <_d_arraybounds_slice@plt>
│ │ │ │  	strbvs	r6, [r4, #-3689]!	@ 0xfffff197
│ │ │ │ -	ldrdeq	sl, [r4], -r0
│ │ │ │ -	andeq	sl, r4, ip, lsr #31
│ │ │ │ -	andeq	fp, r4, ip, ror #6
│ │ │ │ -	andeq	sl, r4, ip, lsl #31
│ │ │ │ -	andeq	sl, r4, r0, ror pc
│ │ │ │ +	andeq	fp, r4, r0
│ │ │ │ +	ldrdeq	sl, [r4], -ip
│ │ │ │ +	andeq	fp, r4, ip, ror r0
│ │ │ │ +			@ <UNDEFINED> instruction: 0x0004afbc
│ │ │ │ +	andeq	sl, r4, r0, lsr #31
│ │ │ │  
│ │ │ │  0008ed24 <core.exception.rangeMsgPut(ref char[], scope const(char)[])@@Base>:
│ │ │ │  	push	{r4, r6, r7, lr}
│ │ │ │  	sub	sp, sp, #8
│ │ │ │  	ldr	r7, [r0]
│ │ │ │  	mov	r6, r1
│ │ │ │  	cmp	r1, r7
│ │ │ │ @@ -22011,16 +22011,16 @@
│ │ │ │  	ldr	r1, [pc, #24]	@ 8edb8 <core.exception.rangeMsgPut(ref char[], scope const(char)[])@@Base+0x94>
│ │ │ │  	mov	r0, #16
│ │ │ │  	mov	r2, #202	@ 0xca
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	mov	r3, #0
│ │ │ │  	strd	r6, [sp]
│ │ │ │  	bl	78454 <_d_arraybounds_slice@plt>
│ │ │ │ -	andeq	sl, r4, r4, ror #29
│ │ │ │ -	andeq	sl, r4, r4, asr #29
│ │ │ │ +	andeq	sl, r4, r4, lsl pc
│ │ │ │ +	strdeq	sl, [r4], -r4
│ │ │ │  
│ │ │ │  0008edbc <core.exception.ArraySliceError.this(uint, uint, uint, immutable(char)[], uint, object.Throwable)@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, r8, r9, sl, fp, lr}
│ │ │ │  	sub	sp, sp, #156	@ 0x9c
│ │ │ │  	mov	r8, r0
│ │ │ │  	add	ip, r8, #48	@ 0x30
│ │ │ │  	ldr	r0, [pc, #672]	@ 8f074 <core.exception.ArraySliceError.this(uint, uint, uint, immutable(char)[], uint, object.Throwable)@@Base+0x2b8>
│ │ │ │ @@ -22191,24 +22191,24 @@
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	mov	r0, #16
│ │ │ │  	mov	r2, #202	@ 0xca
│ │ │ │  	mov	r3, #0
│ │ │ │  	bl	78454 <_d_arraybounds_slice@plt>
│ │ │ │  	cmnvs	r9, #29440	@ 0x7300
│ │ │ │  	eorcs	r2, lr, r0, lsr #28
│ │ │ │ -	ldrdeq	sl, [r4], -r4
│ │ │ │ -	andeq	sl, r4, r0, asr #25
│ │ │ │ -	andeq	sl, r4, r0, lsr #25
│ │ │ │ -	andeq	sl, r4, r4, lsl #25
│ │ │ │ -	andeq	sl, r4, r4, asr #24
│ │ │ │ -	ldrdeq	sl, [r4], -ip
│ │ │ │ -	andeq	sl, r4, r4, lsr #24
│ │ │ │ -	andeq	sl, r4, ip, ror #27
│ │ │ │ -	andeq	sl, r4, r8, lsl #24
│ │ │ │ -	andeq	sl, r4, r4, ror #24
│ │ │ │ +	andeq	sl, r4, r4, lsl #26
│ │ │ │ +	strdeq	sl, [r4], -r0
│ │ │ │ +	ldrdeq	sl, [r4], -r0
│ │ │ │ +			@ <UNDEFINED> instruction: 0x0004acb4
│ │ │ │ +	andeq	sl, r4, r4, ror ip
│ │ │ │ +	andeq	sl, r4, ip, lsl #28
│ │ │ │ +	andeq	sl, r4, r4, asr ip
│ │ │ │ +	andeq	sl, r4, ip, lsl lr
│ │ │ │ +	andeq	sl, r4, r8, lsr ip
│ │ │ │ +	muleq	r4, r4, ip
│ │ │ │  
│ │ │ │  0008f0a4 <core.exception.AssertError.this(immutable(char)[], uint)@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │  	ldr	lr, [pc, #40]	@ 8f0dc <core.exception.AssertError.this(immutable(char)[], uint)@@Base+0x38>
│ │ │ │  	mov	ip, r1
│ │ │ │  	mov	r1, #0
│ │ │ │ @@ -22217,15 +22217,15 @@
│ │ │ │  	str	r1, [sp, #8]
│ │ │ │  	mov	r1, #17
│ │ │ │  	mov	r2, lr
│ │ │ │  	mov	r3, ip
│ │ │ │  	bl	7909c <object.Error.this(immutable(char)[], immutable(char)[], uint, object.Throwable)@plt>
│ │ │ │  	add	sp, sp, #16
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	sl, r4, r0, ror ip
│ │ │ │ +	andeq	sl, r4, r0, lsr #25
│ │ │ │  
│ │ │ │  0008f0e0 <core.exception.AssertError.this(object.Throwable, immutable(char)[], uint)@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │  	mov	ip, r2
│ │ │ │  	ldr	r2, [pc, #32]	@ 8f114 <core.exception.AssertError.this(object.Throwable, immutable(char)[], uint)@@Base+0x34>
│ │ │ │  	ldr	lr, [sp, #24]
│ │ │ │ @@ -22233,15 +22233,15 @@
│ │ │ │  	str	r1, [sp, #8]
│ │ │ │  	add	r2, pc, r2
│ │ │ │  	mov	r1, #17
│ │ │ │  	mov	r3, ip
│ │ │ │  	bl	7909c <object.Error.this(immutable(char)[], immutable(char)[], uint, object.Throwable)@plt>
│ │ │ │  	add	sp, sp, #16
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	sl, r4, ip, lsr #24
│ │ │ │ +	andeq	sl, r4, ip, asr ip
│ │ │ │  
│ │ │ │  0008f118 <core.exception.AssertError.this(immutable(char)[], immutable(char)[], uint, object.Throwable)@@Base>:
│ │ │ │  	push	{r4, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │  	ldr	ip, [sp, #24]
│ │ │ │  	ldr	r4, [sp, #32]
│ │ │ │  	ldr	lr, [sp, #28]
│ │ │ │ @@ -22263,15 +22263,15 @@
│ │ │ │  	stm	sp, {r1, lr}
│ │ │ │  	mov	r1, #18
│ │ │ │  	mov	r2, ip
│ │ │ │  	bl	7909c <object.Error.this(immutable(char)[], immutable(char)[], uint, object.Throwable)@plt>
│ │ │ │  	str	r4, [r0, #48]	@ 0x30
│ │ │ │  	add	sp, sp, #16
│ │ │ │  	pop	{r4, pc}
│ │ │ │ -	andeq	sl, r4, r4, lsl ip
│ │ │ │ +	andeq	sl, r4, r4, asr #24
│ │ │ │  
│ │ │ │  0008f180 <core.exception.FinalizeError.this(TypeInfo, immutable(char)[], uint, object.Throwable)@@Base>:
│ │ │ │  	push	{r4, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │  	mov	r4, r1
│ │ │ │  	ldr	r1, [sp, #24]
│ │ │ │  	mov	ip, r2
│ │ │ │ @@ -22282,30 +22282,30 @@
│ │ │ │  	add	r2, pc, r2
│ │ │ │  	mov	r1, #18
│ │ │ │  	mov	r3, ip
│ │ │ │  	bl	7909c <object.Error.this(immutable(char)[], immutable(char)[], uint, object.Throwable)@plt>
│ │ │ │  	str	r4, [r0, #48]	@ 0x30
│ │ │ │  	add	sp, sp, #16
│ │ │ │  	pop	{r4, pc}
│ │ │ │ -	andeq	sl, r4, r4, asr #23
│ │ │ │ +	strdeq	sl, [r4], -r4
│ │ │ │  
│ │ │ │  0008f1c4 <core.exception.FinalizeError.toString() const@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	ldr	r0, [r0, #48]	@ 0x30
│ │ │ │  	ldr	r1, [r0]
│ │ │ │  	ldr	r1, [r1, #4]
│ │ │ │  	blx	r1
│ │ │ │  	mov	r3, r1
│ │ │ │  	ldr	r1, [pc, #16]	@ 8f1f4 <core.exception.FinalizeError.toString() const@@Base+0x30>
│ │ │ │  	mov	r2, r0
│ │ │ │  	mov	r0, #56	@ 0x38
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	pop	{fp, lr}
│ │ │ │  	b	79240 <core.internal.array.concatenation._d_arraycatnTX!(immutable(char)[], immutable(char)[], immutable(char)[])._d_arraycatnTX(immutable(char)[], immutable(char)[])@plt>
│ │ │ │ -	andeq	sl, r4, r0, lsr #23
│ │ │ │ +	ldrdeq	sl, [r4], -r0
│ │ │ │  
│ │ │ │  0008f1f8 <core.exception.OutOfMemoryError.this(immutable(char)[], uint, object.Throwable)@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │  	ldr	lr, [pc, #40]	@ 8f230 <core.exception.OutOfMemoryError.this(immutable(char)[], uint, object.Throwable)@@Base+0x38>
│ │ │ │  	mov	ip, r1
│ │ │ │  	ldr	r1, [sp, #24]
│ │ │ │ @@ -22314,15 +22314,15 @@
│ │ │ │  	str	r1, [sp, #8]
│ │ │ │  	mov	r1, #24
│ │ │ │  	mov	r2, lr
│ │ │ │  	mov	r3, ip
│ │ │ │  	bl	7909c <object.Error.this(immutable(char)[], immutable(char)[], uint, object.Throwable)@plt>
│ │ │ │  	add	sp, sp, #16
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	ldrdeq	sl, [r4], -ip
│ │ │ │ +	andeq	sl, r4, ip, lsl #24
│ │ │ │  
│ │ │ │  0008f234 <core.exception.OutOfMemoryError.this(bool, immutable(char)[], uint, object.Throwable)@@Base>:
│ │ │ │  	push	{r4, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │  	mov	r4, r1
│ │ │ │  	ldr	r1, [sp, #24]
│ │ │ │  	mov	ip, r2
│ │ │ │ @@ -22337,15 +22337,15 @@
│ │ │ │  	cmp	r4, #0
│ │ │ │  	ldreq	r1, [pc, #20]	@ 8f288 <core.exception.OutOfMemoryError.this(bool, immutable(char)[], uint, object.Throwable)@@Base+0x54>
│ │ │ │  	addeq	r1, pc, r1
│ │ │ │  	addeq	r1, r1, #8
│ │ │ │  	streq	r1, [r0, #28]
│ │ │ │  	add	sp, sp, #16
│ │ │ │  	pop	{r4, pc}
│ │ │ │ -	muleq	r4, r0, fp
│ │ │ │ +	andeq	sl, r4, r0, asr #23
│ │ │ │  	strdeq	r2, [r7], -r4
│ │ │ │  
│ │ │ │  0008f28c <core.exception.SuppressTraceInfo.instance()@@Base>:
│ │ │ │  	ldr	r0, [pc, #4]	@ 8f298 <core.exception.SuppressTraceInfo.instance()@@Base+0xc>
│ │ │ │  	add	r0, pc, r0
│ │ │ │  	bx	lr
│ │ │ │  	ldrdeq	r2, [r7], -r4
│ │ │ │ @@ -22357,15 +22357,15 @@
│ │ │ │  	push	{fp, lr}
│ │ │ │  	bl	79c7c <object.Throwable.toString()@plt>
│ │ │ │  	pop	{fp, pc}
│ │ │ │  	ldr	r1, [pc, #8]	@ 8f2c4 <core.exception.OutOfMemoryError.toString() const@@Base+0x28>
│ │ │ │  	mov	r0, #24
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	bx	lr
│ │ │ │ -	andeq	sl, r4, ip, lsr #22
│ │ │ │ +	andeq	sl, r4, ip, asr fp
│ │ │ │  
│ │ │ │  0008f2c8 <core.exception.OutOfMemoryError.superToString()@@Base>:
│ │ │ │  	b	79c7c <object.Throwable.toString()@plt>
│ │ │ │  
│ │ │ │  0008f2cc <core.exception.InvalidMemoryOperationError.this(immutable(char)[], uint, object.Throwable)@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │ @@ -22377,28 +22377,28 @@
│ │ │ │  	str	r1, [sp, #8]
│ │ │ │  	mov	r1, #24
│ │ │ │  	mov	r2, lr
│ │ │ │  	mov	r3, ip
│ │ │ │  	bl	7909c <object.Error.this(immutable(char)[], immutable(char)[], uint, object.Throwable)@plt>
│ │ │ │  	add	sp, sp, #16
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	sl, r4, r8, asr #22
│ │ │ │ +	andeq	sl, r4, r8, ror fp
│ │ │ │  
│ │ │ │  0008f308 <core.exception.InvalidMemoryOperationError.toString() const@@Base>:
│ │ │ │  	ldr	r1, [r0, #8]
│ │ │ │  	cmp	r1, #0
│ │ │ │  	beq	8f320 <core.exception.InvalidMemoryOperationError.toString() const@@Base+0x18>
│ │ │ │  	push	{fp, lr}
│ │ │ │  	bl	79c7c <object.Throwable.toString()@plt>
│ │ │ │  	pop	{fp, pc}
│ │ │ │  	ldr	r1, [pc, #8]	@ 8f330 <core.exception.InvalidMemoryOperationError.toString() const@@Base+0x28>
│ │ │ │  	mov	r0, #24
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	bx	lr
│ │ │ │ -	andeq	sl, r4, r0, lsl #22
│ │ │ │ +	andeq	sl, r4, r0, lsr fp
│ │ │ │  
│ │ │ │  0008f334 <core.exception.InvalidMemoryOperationError.superToString()@@Base>:
│ │ │ │  	b	79c7c <object.Throwable.toString()@plt>
│ │ │ │  
│ │ │ │  0008f338 <core.exception.ForkError.this(immutable(char)[], uint, object.Throwable)@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │ @@ -22961,15 +22961,15 @@
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, pc}
│ │ │ │  	add	r0, sp, #4
│ │ │ │  	add	r1, sp, #16
│ │ │ │  	add	r2, sp, #12
│ │ │ │  	bl	78310 <core.exception.staticError!(core.exception.AssertError, immutable(char)[], immutable(char)[], uint).staticError(ref immutable(char)[], ref immutable(char)[], ref uint)@plt>
│ │ │ │  	bl	78250 <_d_throw_exception@plt>
│ │ │ │ -	andeq	sl, r4, r8, lsl r4
│ │ │ │ +	andeq	sl, r4, r8, asr #8
│ │ │ │  	andeq	r1, r7, r0, lsl sl
│ │ │ │  
│ │ │ │  0008fb24 <_d_unittest@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	sub	sp, sp, #24
│ │ │ │  	ldr	lr, [pc, #80]	@ 8fb84 <_d_unittest@@Base+0x60>
│ │ │ │  	ldr	r3, [pc, #80]	@ 8fb88 <_d_unittest@@Base+0x64>
│ │ │ │ @@ -22989,15 +22989,15 @@
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{fp, pc}
│ │ │ │  	add	r0, sp, #4
│ │ │ │  	add	r1, sp, #16
│ │ │ │  	add	r2, sp, #12
│ │ │ │  	bl	78310 <core.exception.staticError!(core.exception.AssertError, immutable(char)[], immutable(char)[], uint).staticError(ref immutable(char)[], ref immutable(char)[], ref uint)@plt>
│ │ │ │  	bl	78250 <_d_throw_exception@plt>
│ │ │ │ -	andeq	sl, r4, r4, lsr #7
│ │ │ │ +	ldrdeq	sl, [r4], -r4
│ │ │ │  	muleq	r7, ip, r9
│ │ │ │  
│ │ │ │  0008fb8c <_d_unittest_msg@@Base>:
│ │ │ │  	push	{r4, lr}
│ │ │ │  	sub	sp, sp, #24
│ │ │ │  	mov	ip, r0
│ │ │ │  	ldr	r0, [pc, #88]	@ 8fbf8 <_d_unittest_msg@@Base+0x6c>
│ │ │ │ @@ -23120,15 +23120,15 @@
│ │ │ │  	str	r0, [sp]
│ │ │ │  	add	r2, sp, #8
│ │ │ │  	add	r3, sp, #4
│ │ │ │  	mov	r0, #34	@ 0x22
│ │ │ │  	mov	r1, ip
│ │ │ │  	bl	77b30 <core.exception.staticError!(core.exception.SwitchError, immutable(char)[], immutable(char)[], uint, typeof(null)).staticError(immutable(char)[], ref immutable(char)[], ref uint, typeof(null))@plt>
│ │ │ │  	bl	78250 <_d_throw_exception@plt>
│ │ │ │ -	andeq	sl, r4, r8, lsr #4
│ │ │ │ +	andeq	sl, r4, r8, asr r2
│ │ │ │  
│ │ │ │  0008fd2c <core.exception.staticError!(core.exception.SwitchError, immutable(char)[], immutable(char)[], uint, typeof(null)).staticError(immutable(char)[], ref immutable(char)[], ref uint, typeof(null))@@Base>:
│ │ │ │  	push	{r4, r5, r6, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │  	mov	r5, r2
│ │ │ │  	ldr	r2, [pc, #60]	@ 8fd7c <core.exception.staticError!(core.exception.SwitchError, immutable(char)[], immutable(char)[], uint, typeof(null)).staticError(immutable(char)[], ref immutable(char)[], ref uint, typeof(null))@@Base+0x50>
│ │ │ │  	str	r0, [sp, #8]
│ │ │ │ @@ -57224,15 +57224,15 @@
│ │ │ │  	mov	r2, #13
│ │ │ │  	bl	796a8 <fprintf@plt>
│ │ │ │  	subs	r0, r4, r6
│ │ │ │  	movne	r0, #1
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, r7, r8, r9, fp, pc}
│ │ │ │  	strdeq	ip, [r2], -r8
│ │ │ │ -	andeq	sl, r2, r0, lsl #10
│ │ │ │ +	ldrdeq	sl, [r2], -sl	@ <UNPREDICTABLE>
│ │ │ │  	andeq	r2, r5, r4, lsr r9
│ │ │ │  
│ │ │ │  000aecc8 <core.internal.parseoptions.find!(core.internal.parseoptions.parse(const(char)[], ref inout(char)[], ref inout(char)[], const(char)[]).__lambda_L302_C27).find(inout(char)[])@@Base>:
│ │ │ │  	cmp	r1, #0
│ │ │ │  	beq	aecec <core.internal.parseoptions.find!(core.internal.parseoptions.parse(const(char)[], ref inout(char)[], ref inout(char)[], const(char)[]).__lambda_L302_C27).find(inout(char)[])@@Base+0x24>
│ │ │ │  	mov	r0, r1
│ │ │ │  	ldrb	r1, [r2]
│ │ │ │ @@ -57302,15 +57302,15 @@
│ │ │ │  	mov	r2, #3
│ │ │ │  	cmp	r0, #0
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	movne	r2, #0
│ │ │ │  	movne	r1, #0
│ │ │ │  	mov	r0, r2
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	sl, r2, r2, lsr #7
│ │ │ │ +			@ <UNDEFINED> instruction: 0x0002a3b0
│ │ │ │  
│ │ │ │  000aedd4 <core.internal.parseoptions.parseOptions!(core.gc.config.Config).parseOptions(ref core.gc.config.Config, immutable(char)[])@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, r8, r9, sl, fp, lr}
│ │ │ │  	sub	sp, sp, #84	@ 0x54
│ │ │ │  	mov	r5, r2
│ │ │ │  	mov	fp, r1
│ │ │ │  	mov	r9, r0
│ │ │ │ @@ -57816,41 +57816,41 @@
│ │ │ │  	str	r7, [sp, #16]
│ │ │ │  	mov	r2, #18
│ │ │ │  	stmib	sp, {r4, sl}
│ │ │ │  	bl	796a8 <fprintf@plt>
│ │ │ │  	mov	r0, r6
│ │ │ │  	add	sp, sp, #84	@ 0x54
│ │ │ │  	pop	{r4, r5, r6, r7, r8, r9, sl, fp, pc}
│ │ │ │ -	andeq	sl, r2, lr, lsl #6
│ │ │ │ +	andeq	sl, r2, ip, lsl r3
│ │ │ │  	ldrdeq	fp, [r2], -r0
│ │ │ │  	andeq	fp, r2, ip, lsl #23
│ │ │ │  	andeq	r2, r5, r0, asr #4
│ │ │ │  	andeq	fp, r2, ip, ror #17
│ │ │ │  	andeq	fp, r2, r8, asr #17
│ │ │ │  	andeq	r2, r5, ip, lsl r0
│ │ │ │  	andeq	fp, r2, r4, lsr r9
│ │ │ │  	ldrdeq	fp, [r2], -r0
│ │ │ │  	andeq	r2, r5, r4, rrx
│ │ │ │  	andeq	fp, r2, r4, asr #21
│ │ │ │ -	andeq	r9, r2, r3, asr #27
│ │ │ │ +	ldrdeq	r9, [r2], -r1
│ │ │ │  	strdeq	r2, [r5], -r4
│ │ │ │  	andeq	fp, r2, r0, lsl sl
│ │ │ │ -	andeq	r9, r2, r8, lsl sp
│ │ │ │ +	strdeq	r9, [r2], -r2
│ │ │ │  	andeq	r2, r5, r0, asr #2
│ │ │ │  	andeq	fp, r2, r0, ror sl
│ │ │ │ -	andeq	r9, r2, pc, ror #26
│ │ │ │ +	andeq	r9, r2, sp, ror sp
│ │ │ │  	andeq	r2, r5, r0, lsr #3
│ │ │ │  	strdeq	r9, [r2], -sp
│ │ │ │  	andeq	fp, r2, r8, ror r9
│ │ │ │  	andeq	r9, r2, r2, asr ip
│ │ │ │  	andeq	r2, r5, r8, lsr #1
│ │ │ │  	andeq	fp, r2, ip, lsl #19
│ │ │ │ -			@ <UNDEFINED> instruction: 0x00029cb7
│ │ │ │ +	andeq	r9, r2, r5, asr #25
│ │ │ │  	strdeq	r2, [r5], -ip
│ │ │ │ -	andeq	r9, r2, r6, asr pc
│ │ │ │ +	andeq	r9, r2, r4, ror #30
│ │ │ │  
│ │ │ │  000af63c <core.internal.parseoptions.skip!(isspace).skip(inout(char)[])@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	cmp	r0, #0
│ │ │ │  	beq	af66c <core.internal.parseoptions.skip!(isspace).skip(inout(char)[])@@Base+0x30>
│ │ │ │  	mov	r5, r1
│ │ │ │  	mov	r4, r0
│ │ │ │ @@ -58093,20 +58093,20 @@
│ │ │ │  	mov	r2, #30
│ │ │ │  	bl	796a8 <fprintf@plt>
│ │ │ │  	mov	r0, r4
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, r7, r8, r9, fp, pc}
│ │ │ │  	andeq	fp, r2, r4, asr #9
│ │ │ │  	andeq	fp, r2, r0, lsl #11
│ │ │ │ -	andeq	r9, r2, r3, lsr #15
│ │ │ │ +			@ <UNDEFINED> instruction: 0x000297b1
│ │ │ │  	strdeq	r1, [r5], -r0
│ │ │ │  	andeq	fp, r2, ip, ror r5
│ │ │ │  	andeq	r1, r5, r0, ror #24
│ │ │ │  	andeq	fp, r2, r0, asr #11
│ │ │ │ -	andeq	r9, r2, pc, lsr #17
│ │ │ │ +			@ <UNDEFINED> instruction: 0x000298bd
│ │ │ │  	strdeq	r1, [r5], -r0
│ │ │ │  
│ │ │ │  000afa20 <core.internal.parseoptions.find!(core.internal.parseoptions.skip!(isspace).skip(inout(char)[]).__lambda_L162_C18).find(inout(char)[])@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	cmp	r1, #0
│ │ │ │  	beq	afa50 <core.internal.parseoptions.find!(core.internal.parseoptions.skip!(isspace).skip(inout(char)[]).__lambda_L162_C18).find(inout(char)[])@@Base+0x30>
│ │ │ │  	mov	r5, r2
│ │ │ │ @@ -58167,15 +58167,15 @@
│ │ │ │  	mov	r2, #3
│ │ │ │  	cmp	r0, #0
│ │ │ │  	add	r1, pc, r1
│ │ │ │  	movne	r2, #0
│ │ │ │  	movne	r1, #0
│ │ │ │  	mov	r0, r2
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	r9, r2, r6, ror #12
│ │ │ │ +	andeq	r9, r2, r4, ror r6
│ │ │ │  
│ │ │ │  000afb10 <core.internal.parseoptions.parseOptions!(rt.cover.Config).parseOptions(ref rt.cover.Config, immutable(char)[])@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, r8, r9, sl, fp, lr}
│ │ │ │  	sub	sp, sp, #36	@ 0x24
│ │ │ │  	mov	r9, r2
│ │ │ │  	mov	r5, r1
│ │ │ │  	mov	fp, r0
│ │ │ │ @@ -58416,26 +58416,26 @@
│ │ │ │  	ldr	r7, [sp, #28]
│ │ │ │  	str	r2, [sp, #20]
│ │ │ │  	stm	lr, {r4, r9, ip}
│ │ │ │  	str	r7, [sp]
│ │ │ │  	ldr	r7, [sp, #32]
│ │ │ │  	mov	r2, #18
│ │ │ │  	b	afe48 <core.internal.parseoptions.parseOptions!(rt.cover.Config).parseOptions(ref rt.cover.Config, immutable(char)[])@@Base+0x338>
│ │ │ │ -	andeq	r9, r2, r6, lsl #11
│ │ │ │ +	muleq	r2, r4, r5
│ │ │ │  	andeq	fp, r2, r8, rrx
│ │ │ │  	andeq	fp, r2, r4, lsr #2
│ │ │ │  	ldrdeq	r1, [r5], -r8
│ │ │ │  	andeq	fp, r2, ip, asr r0
│ │ │ │ -	andeq	r9, r2, r0, ror #6
│ │ │ │ +	andeq	r9, r2, sl, lsr r3
│ │ │ │  	muleq	r5, r0, r7
│ │ │ │  	andeq	sl, r2, r0, asr #31
│ │ │ │  	muleq	r2, r8, pc	@ <UNPREDICTABLE>
│ │ │ │  	strdeq	r1, [r5], -r4
│ │ │ │  	andeq	sl, r2, ip, asr #31
│ │ │ │ -	strdeq	r9, [r2], -r7
│ │ │ │ +	andeq	r9, r2, r5, lsl #6
│ │ │ │  	andeq	r1, r5, ip, lsr r7
│ │ │ │  
│ │ │ │  000aff1c <core.internal.parseoptions.find!(core.internal.parseoptions.parseOptions!(rt.cover.Config).parseOptions(ref rt.cover.Config, immutable(char)[]).__lambda_L79_C27_1).find(inout(char)[])@@Base>:
│ │ │ │  	cmp	r1, #0
│ │ │ │  	beq	aff60 <core.internal.parseoptions.find!(core.internal.parseoptions.parseOptions!(rt.cover.Config).parseOptions(ref rt.cover.Config, immutable(char)[]).__lambda_L79_C27_1).find(inout(char)[])@@Base+0x44>
│ │ │ │  	mov	r0, r1
│ │ │ │  	mov	ip, #1
│ │ │ │ @@ -59837,40 +59837,40 @@
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r0, #1
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  			@ <UNDEFINED> instruction: 0x00027cb0
│ │ │ │ -			@ <UNDEFINED> instruction: 0x00027db7
│ │ │ │ -	andeq	r7, r2, r4, ror #27
│ │ │ │ +	andeq	r7, r2, pc, lsr #27
│ │ │ │ +	ldrdeq	r7, [r2], -ip
│ │ │ │  
│ │ │ │  000b146c <core.internal.switch_.__switch!(immutable(char), "none").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	ldr	r3, [pc, #24]	@ b1490 <core.internal.switch_.__switch!(immutable(char), "none").__switch(scope const(immutable(char)[]))@@Base+0x24>
│ │ │ │  	mov	r2, #4
│ │ │ │  	add	r3, pc, r3
│ │ │ │  	bl	78208 <core.internal.array.comparison.__cmp!(char).__cmp(scope const(char[]), scope const(char[]))@plt>
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	r7, r2, pc, ror sp
│ │ │ │ +	andeq	r7, r2, r7, ror sp
│ │ │ │  
│ │ │ │  000b1494 <core.internal.switch_.__switch!(immutable(char), "finalize").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	ldr	r3, [pc, #24]	@ b14b8 <core.internal.switch_.__switch!(immutable(char), "finalize").__switch(scope const(immutable(char)[]))@@Base+0x24>
│ │ │ │  	mov	r2, #8
│ │ │ │  	add	r3, pc, r3
│ │ │ │  	bl	78208 <core.internal.array.comparison.__cmp!(char).__cmp(scope const(char[]), scope const(char[]))@plt>
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	r7, r2, ip, asr sp
│ │ │ │ +	andeq	r7, r2, r4, asr sp
│ │ │ │  
│ │ │ │  000b14bc <core.internal.switch_.__switch!(immutable(char), "", "run-main", "test-only", "test-or-main").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	cmp	r0, #9
│ │ │ │  	bne	b14fc <core.internal.switch_.__switch!(immutable(char), "", "run-main", "test-only", "test-or-main").__switch(scope const(immutable(char)[]))@@Base+0x40>
│ │ │ │  	ldr	r3, [pc, #196]	@ b1594 <core.internal.switch_.__switch!(immutable(char), "", "run-main", "test-only", "test-or-main").__switch(scope const(immutable(char)[]))@@Base+0xd8>
│ │ │ │  	mov	r2, #9
│ │ │ │ @@ -59919,18 +59919,18 @@
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r2, #2
│ │ │ │  	mov	r0, r2
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r0, #1
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │ -	andeq	r7, r2, r1, lsr sp
│ │ │ │ -	ldrdeq	r7, [r2], -r7	@ <UNPREDICTABLE>
│ │ │ │ +	andeq	r7, r2, r9, lsr #26
│ │ │ │ +	andeq	r7, r2, pc, asr #25
│ │ │ │  			@ <UNDEFINED> instruction: 0x00027fb5
│ │ │ │ -	andeq	r7, r2, r0, lsl sp
│ │ │ │ +	andeq	r7, r2, r8, lsl #26
│ │ │ │  
│ │ │ │  000b15a4 <core.internal.switch_.__switch!(immutable(char), "", "run-main").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	cmp	r0, #8
│ │ │ │  	bne	b15ec <core.internal.switch_.__switch!(immutable(char), "", "run-main").__switch(scope const(immutable(char)[]))@@Base+0x48>
│ │ │ │  	ldr	r3, [pc, #104]	@ b1620 <core.internal.switch_.__switch!(immutable(char), "", "run-main").__switch(scope const(immutable(char)[]))@@Base+0x7c>
│ │ │ │  	mov	r2, #8
│ │ │ │ @@ -59956,28 +59956,28 @@
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r2, #1
│ │ │ │  	mov	r0, r2
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │ -	andeq	r7, r2, r3, asr ip
│ │ │ │ +	andeq	r7, r2, fp, asr #24
│ │ │ │  	andeq	r7, r2, r1, lsr #30
│ │ │ │  
│ │ │ │  000b1628 <core.internal.switch_.__switch!(immutable(char), "test-or-main").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	ldr	r3, [pc, #24]	@ b164c <core.internal.switch_.__switch!(immutable(char), "test-or-main").__switch(scope const(immutable(char)[]))@@Base+0x24>
│ │ │ │  	mov	r2, #12
│ │ │ │  	add	r3, pc, r3
│ │ │ │  	bl	78208 <core.internal.array.comparison.__cmp!(char).__cmp(scope const(char[]), scope const(char[]))@plt>
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	r7, r2, r4, ror #23
│ │ │ │ +	ldrdeq	r7, [r2], -ip
│ │ │ │  
│ │ │ │  000b1650 <core.internal.switch_.__switch!(immutable(char), "").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	ldr	r3, [pc, #24]	@ b1674 <core.internal.switch_.__switch!(immutable(char), "").__switch(scope const(immutable(char)[]))@@Base+0x24>
│ │ │ │  	mov	r2, #0
│ │ │ │  	add	r3, pc, r3
│ │ │ │  	bl	78208 <core.internal.array.comparison.__cmp!(char).__cmp(scope const(char[]), scope const(char[]))@plt>
│ │ │ │ @@ -60039,18 +60039,18 @@
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r2, #2
│ │ │ │  	mov	r0, r2
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r0, #1
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │ -	andeq	r7, r2, sp, lsl #23
│ │ │ │ +	andeq	r7, r2, r5, lsl #23
│ │ │ │  	ldrdeq	r7, [r2], -fp
│ │ │ │ -	andeq	r7, r2, sp, lsl #22
│ │ │ │ -	andeq	r7, r2, r7, lsr fp
│ │ │ │ +	andeq	r7, r2, r5, lsl #22
│ │ │ │ +	andeq	r7, r2, pc, lsr #22
│ │ │ │  
│ │ │ │  000b175c <core.internal.switch_.__switch!(immutable(char), "merge", "disable").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	cmp	r0, #7
│ │ │ │  	bne	b17a4 <core.internal.switch_.__switch!(immutable(char), "merge", "disable").__switch(scope const(immutable(char)[]))@@Base+0x48>
│ │ │ │  	ldr	r3, [pc, #104]	@ b17d8 <core.internal.switch_.__switch!(immutable(char), "merge", "disable").__switch(scope const(immutable(char)[]))@@Base+0x7c>
│ │ │ │  	mov	r2, #7
│ │ │ │ @@ -60077,39 +60077,39 @@
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r2, #1
│ │ │ │  	mov	r0, r2
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	andeq	r7, r2, fp, lsr #20
│ │ │ │ -	andeq	r7, r2, r9, ror sl
│ │ │ │ +	andeq	r7, r2, r1, ror sl
│ │ │ │  
│ │ │ │  000b17e0 <core.internal.switch_.__switch!(immutable(char), "srcpath").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	ldr	r3, [pc, #24]	@ b1804 <core.internal.switch_.__switch!(immutable(char), "srcpath").__switch(scope const(immutable(char)[]))@@Base+0x24>
│ │ │ │  	mov	r2, #7
│ │ │ │  	add	r3, pc, r3
│ │ │ │  	bl	78208 <core.internal.array.comparison.__cmp!(char).__cmp(scope const(char[]), scope const(char[]))@plt>
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	r7, r2, r7, asr #20
│ │ │ │ +	andeq	r7, r2, pc, lsr sl
│ │ │ │  
│ │ │ │  000b1808 <core.internal.switch_.__switch!(immutable(char), "merge").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	ldr	r3, [pc, #24]	@ b182c <core.internal.switch_.__switch!(immutable(char), "merge").__switch(scope const(immutable(char)[]))@@Base+0x24>
│ │ │ │  	mov	r2, #5
│ │ │ │  	add	r3, pc, r3
│ │ │ │  	bl	78208 <core.internal.array.comparison.__cmp!(char).__cmp(scope const(char[]), scope const(char[]))@plt>
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	andeq	r7, r2, r9, lsl sl
│ │ │ │ +	andeq	r7, r2, r1, lsl sl
│ │ │ │  
│ │ │ │  000b1830 <core.internal.switch_.__switch!(immutable(char), "", "abort", "print", "ignore", "deprecate").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	mov	r4, r1
│ │ │ │  	mov	r5, r0
│ │ │ │  	cmp	r0, #5
│ │ │ │  	bne	b18a0 <core.internal.switch_.__switch!(immutable(char), "", "abort", "print", "ignore", "deprecate").__switch(scope const(immutable(char)[]))@@Base+0x70>
│ │ │ │ @@ -60177,19 +60177,19 @@
│ │ │ │  	mov	r0, #-2147483643	@ 0x80000005
│ │ │ │  	bhi	b189c <core.internal.switch_.__switch!(immutable(char), "", "abort", "print", "ignore", "deprecate").__switch(scope const(immutable(char)[]))@@Base+0x6c>
│ │ │ │  	b	b18dc <core.internal.switch_.__switch!(immutable(char), "", "abort", "print", "ignore", "deprecate").__switch(scope const(immutable(char)[]))@@Base+0xac>
│ │ │ │  	mov	r0, #4
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r0, #1
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │ -	andeq	r7, r2, fp, ror #19
│ │ │ │ -	andeq	r7, r2, r9, asr #19
│ │ │ │ +	andeq	r7, r2, r3, ror #19
│ │ │ │ +	andeq	r7, r2, r1, asr #19
│ │ │ │  	andeq	r7, r2, r9, lsl #24
│ │ │ │ -	andeq	r7, r2, pc, lsl #19
│ │ │ │ -	andeq	r7, r2, r9, ror #18
│ │ │ │ +	andeq	r7, r2, r7, lsl #19
│ │ │ │ +	andeq	r7, r2, r1, ror #18
│ │ │ │  
│ │ │ │  000b1968 <core.internal.switch_.__switch!(immutable(char), "", "abort").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	cmp	r0, #5
│ │ │ │  	bne	b19b0 <core.internal.switch_.__switch!(immutable(char), "", "abort").__switch(scope const(immutable(char)[]))@@Base+0x48>
│ │ │ │  	ldr	r3, [pc, #104]	@ b19e4 <core.internal.switch_.__switch!(immutable(char), "", "abort").__switch(scope const(immutable(char)[]))@@Base+0x7c>
│ │ │ │  	mov	r2, #5
│ │ │ │ @@ -60215,15 +60215,15 @@
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r2, #1
│ │ │ │  	mov	r0, r2
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │ -	andeq	r7, r2, r1, asr #17
│ │ │ │ +			@ <UNDEFINED> instruction: 0x000278b9
│ │ │ │  	andeq	r7, r2, sp, asr fp
│ │ │ │  
│ │ │ │  000b19ec <core.internal.switch_.__switch!(immutable(char), "ignore", "deprecate").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	cmp	r0, #9
│ │ │ │  	bne	b1a34 <core.internal.switch_.__switch!(immutable(char), "ignore", "deprecate").__switch(scope const(immutable(char)[]))@@Base+0x48>
│ │ │ │  	ldr	r3, [pc, #104]	@ b1a68 <core.internal.switch_.__switch!(immutable(char), "ignore", "deprecate").__switch(scope const(immutable(char)[]))@@Base+0x7c>
│ │ │ │ @@ -60250,28 +60250,28 @@
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │  	mov	r2, #1
│ │ │ │  	mov	r0, r2
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │ -	andeq	r7, r2, r3, asr #16
│ │ │ │ -	andeq	r7, r2, sp, lsl #16
│ │ │ │ +	andeq	r7, r2, fp, lsr r8
│ │ │ │ +	andeq	r7, r2, r5, lsl #16
│ │ │ │  
│ │ │ │  000b1a70 <core.internal.switch_.__switch!(immutable(char), "ignore").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{fp, lr}
│ │ │ │  	ldr	r3, [pc, #24]	@ b1a94 <core.internal.switch_.__switch!(immutable(char), "ignore").__switch(scope const(immutable(char)[]))@@Base+0x24>
│ │ │ │  	mov	r2, #6
│ │ │ │  	add	r3, pc, r3
│ │ │ │  	bl	78208 <core.internal.array.comparison.__cmp!(char).__cmp(scope const(char[]), scope const(char[]))@plt>
│ │ │ │  	cmp	r0, #0
│ │ │ │  	movne	r0, #1
│ │ │ │  	lsl	r0, r0, #31
│ │ │ │  	pop	{fp, pc}
│ │ │ │ -	ldrdeq	r7, [r2], -r5
│ │ │ │ +	andeq	r7, r2, sp, asr #15
│ │ │ │  
│ │ │ │  000b1a98 <core.internal.switch_.__switch!(immutable(char), "", "precise", "conservative").__switch(scope const(immutable(char)[]))@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	cmp	r0, #7
│ │ │ │  	bne	b1af8 <core.internal.switch_.__switch!(immutable(char), "", "precise", "conservative").__switch(scope const(immutable(char)[]))@@Base+0x60>
│ │ │ │  	ldr	r3, [pc, #120]	@ b1b24 <core.internal.switch_.__switch!(immutable(char), "", "precise", "conservative").__switch(scope const(immutable(char)[]))@@Base+0x8c>
│ │ │ │  	mov	r2, #7
│ │ │ │ @@ -71778,55 +71778,55 @@
│ │ │ │  			@ <UNDEFINED> instruction: 0x47868bff
│ │ │ │  	addseq	r9, r8, r0, lsl #13
│ │ │ │  			@ <UNDEFINED> instruction: 0xff676980
│ │ │ │  	addseq	r9, r8, pc, ror r6
│ │ │ │  	teqeq	r1, pc	@ <illegal shifter operand>
│ │ │ │  			@ <UNDEFINED> instruction: 0xffffd8f0
│ │ │ │  	andeq	sp, r1, r4, lsl #19
│ │ │ │ -	andeq	sp, r1, r0, lsr #26
│ │ │ │ -	andeq	sp, r1, pc, asr #25
│ │ │ │ -	andeq	sp, r1, r1, asr ip
│ │ │ │ -	andeq	sp, r1, r2, lsr ip
│ │ │ │ +	andeq	sp, r1, fp, lsl #26
│ │ │ │ +			@ <UNDEFINED> instruction: 0x0001dcba
│ │ │ │ +	andeq	sp, r1, ip, lsr ip
│ │ │ │ +	andeq	sp, r1, sp, lsl ip
│ │ │ │  	andeq	sp, r1, r4, lsl r8
│ │ │ │ -	ldrdeq	sp, [r1], -r1
│ │ │ │ -	andeq	sp, r1, r2, ror #22
│ │ │ │ -	strdeq	sp, [r1], -r6
│ │ │ │ -	ldrdeq	sp, [r1], -sp	@ <UNPREDICTABLE>
│ │ │ │ -	ldrdeq	sp, [r1], -r8
│ │ │ │ +			@ <UNDEFINED> instruction: 0x0001dbbc
│ │ │ │ +	andeq	sp, r1, sp, asr #22
│ │ │ │ +	andeq	sp, r1, r1, ror #21
│ │ │ │ +	andeq	sp, r1, r8, asr #21
│ │ │ │ +	andeq	sp, r1, r3, asr #21
│ │ │ │  	muleq	r1, r4, r6
│ │ │ │ -	andeq	sp, r1, r9, asr #20
│ │ │ │ -	andeq	sp, r1, r4, ror #19
│ │ │ │ -	andeq	sp, r1, r2, lsl #19
│ │ │ │ -	andeq	sp, r1, r5, lsl #19
│ │ │ │ -	andeq	sp, r1, r0, lsl #19
│ │ │ │ +	andeq	sp, r1, r4, lsr sl
│ │ │ │ +	andeq	sp, r1, pc, asr #19
│ │ │ │ +	andeq	sp, r1, sp, ror #18
│ │ │ │ +	andeq	sp, r1, r0, ror r9
│ │ │ │ +	andeq	sp, r1, fp, ror #18
│ │ │ │  	andeq	sp, r1, ip, lsr r5
│ │ │ │ -	strdeq	sp, [r1], -sl
│ │ │ │ -	andeq	sp, r1, r8, lsl #17
│ │ │ │ -	andeq	sp, r1, lr, lsr #16
│ │ │ │ -	andeq	sp, r1, r1, lsr r8
│ │ │ │ -	andeq	sp, r1, ip, lsr #16
│ │ │ │ +	andeq	sp, r1, r5, ror #17
│ │ │ │ +	andeq	sp, r1, r3, ror r8
│ │ │ │ +	andeq	sp, r1, r9, lsl r8
│ │ │ │ +	andeq	sp, r1, ip, lsl r8
│ │ │ │ +	andeq	sp, r1, r7, lsl r8
│ │ │ │  	andeq	sp, r1, r8, ror #7
│ │ │ │ -			@ <UNDEFINED> instruction: 0x0001d7b2
│ │ │ │ -	andeq	sp, r1, r3, lsr #14
│ │ │ │ -	andeq	sp, r1, r6, asr #13
│ │ │ │ -	andeq	sp, r1, r9, asr #13
│ │ │ │ -	andeq	sp, r1, r4, asr #13
│ │ │ │ +	muleq	r1, sp, r7
│ │ │ │ +	andeq	sp, r1, lr, lsl #14
│ │ │ │ +			@ <UNDEFINED> instruction: 0x0001d6b1
│ │ │ │ +			@ <UNDEFINED> instruction: 0x0001d6b4
│ │ │ │ +	andeq	sp, r1, pc, lsr #13
│ │ │ │  	andeq	sp, r1, r4, lsl #5
│ │ │ │ -	andeq	sp, r1, r9, ror #12
│ │ │ │ -	andeq	sp, r1, lr, lsr #11
│ │ │ │ -			@ <UNDEFINED> instruction: 0x0001d5b1
│ │ │ │ -	andeq	sp, r1, ip, lsr #11
│ │ │ │ +	andeq	sp, r1, r4, asr r6
│ │ │ │ +	muleq	r1, r9, r5
│ │ │ │ +	muleq	r1, ip, r5
│ │ │ │ +	muleq	r1, r7, r5
│ │ │ │  	andeq	sp, r1, ip, ror #2
│ │ │ │ -	andeq	sp, r1, r4, asr r5
│ │ │ │ -	strdeq	sp, [r1], -r9
│ │ │ │ -	strdeq	sp, [r1], -r4
│ │ │ │ +	andeq	sp, r1, pc, lsr r5
│ │ │ │ +	andeq	sp, r1, r4, ror #9
│ │ │ │ +	ldrdeq	sp, [r1], -pc	@ <UNPREDICTABLE>
│ │ │ │  	andeq	sp, r1, ip, asr #1
│ │ │ │ -			@ <UNDEFINED> instruction: 0x0001d4b0
│ │ │ │ -	andeq	sp, r1, r9, lsl #9
│ │ │ │ -	andeq	sp, r1, r3, lsl #22
│ │ │ │ +	muleq	r1, fp, r4
│ │ │ │ +	andeq	sp, r1, r4, ror r4
│ │ │ │ +	andeq	sp, r1, lr, ror #21
│ │ │ │  	b	786dc <core.internal.array.appending._d_arrayappendT!(immutable(char)[], immutable(char))._d_arrayappendT(scope return ref immutable(char)[], scope immutable(char)[])@plt>
│ │ │ │  
│ │ │ │  000bbff0 <core.time.Duration.isNegative() const@@Base>:
│ │ │ │  	ldr	r0, [r0, #4]
│ │ │ │  	lsr	r0, r0, #31
│ │ │ │  	bx	lr
│ │ │ │  
│ │ │ │ @@ -71890,16 +71890,16 @@
│ │ │ │  	udf	#65006	@ 0xfdee
│ │ │ │  	andeq	sp, r1, r1, ror r2
│ │ │ │  	andeq	sp, r1, r4, asr #4
│ │ │ │  	andeq	sp, r1, r1, lsr r2
│ │ │ │  	andeq	sp, r1, r8, lsl #1
│ │ │ │  	andeq	sp, r1, r4, asr #4
│ │ │ │  	andeq	sp, r1, r7, lsl r2
│ │ │ │ -	andeq	sp, r1, pc, lsl #4
│ │ │ │ -	andeq	sp, r1, r2, lsr r2
│ │ │ │ +			@ <UNDEFINED> instruction: 0x0001d2b1
│ │ │ │ +	ldrdeq	sp, [r1], -r4
│ │ │ │  
│ │ │ │  000bc0f8 <core.time._clockTypeIdx(core.time.ClockType)@@Base>:
│ │ │ │  	cmp	r0, #7
│ │ │ │  	bxls	lr
│ │ │ │  	udf	#65006	@ 0xfdee
│ │ │ │  
│ │ │ │  000bc104 <_d_initMonoTime@@Base>:
│ │ │ │ @@ -72288,15 +72288,15 @@
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, r7, fp, pc}
│ │ │ │  	blcc	fe76eebc <rt.trace._staticDtor_L408_C1().__critsec956@@Base+0xfe665180>
│ │ │ │  	strdeq	r4, [r4], -ip
│ │ │ │  	ldrdeq	r4, [r4], -r0
│ │ │ │  			@ <UNDEFINED> instruction: 0x00044fb4
│ │ │ │  	andeq	pc, r1, r8, lsl r3	@ <UNPREDICTABLE>
│ │ │ │ -	andeq	ip, r1, ip, lsr #25
│ │ │ │ +	muleq	r1, r7, ip
│ │ │ │  	andeq	r4, r4, ip, asr pc
│ │ │ │  	muleq	r4, r8, sl
│ │ │ │  
│ │ │ │  000bc6d4 <core.time.TickDuration.currSystemTick()@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, r8, lr}
│ │ │ │  	sub	sp, sp, #16
│ │ │ │  	mov	r8, r0
│ │ │ │ @@ -72334,15 +72334,15 @@
│ │ │ │  	mla	r2, r7, r5, r2
│ │ │ │  	adc	r1, r1, r2
│ │ │ │  	strd	r0, [r8]
│ │ │ │  	add	sp, sp, #16
│ │ │ │  	pop	{r4, r5, r6, r7, r8, pc}
│ │ │ │  	blcc	fe76ef78 <rt.trace._staticDtor_L408_C1().__critsec956@@Base+0xfe66523c>
│ │ │ │  	andeq	pc, r1, r0, asr r2	@ <UNPREDICTABLE>
│ │ │ │ -	andeq	ip, r1, r4, ror #23
│ │ │ │ +	andeq	ip, r1, pc, asr #23
│ │ │ │  	muleq	r4, r4, lr
│ │ │ │  
│ │ │ │  000bc780 <core.time.TickDuration.seconds() const@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	ldrd	r0, [r0]
│ │ │ │  	blx	d8a30 <tipc_node@@Base+0x850>
│ │ │ │  	mov	r4, r0
│ │ │ │ @@ -72847,36 +72847,36 @@
│ │ │ │  	cmp	r9, #0
│ │ │ │  	add	sl, sl, #8
│ │ │ │  	mov	r9, r2
│ │ │ │  	mov	fp, r1
│ │ │ │  	bne	bcd38 <core.time.unitsAreInDescendingOrder(scope immutable(char)[][])@@Base+0x19c>
│ │ │ │  	add	sp, sp, #4
│ │ │ │  	pop	{r4, r5, r6, r7, r8, r9, sl, fp, pc}
│ │ │ │ -	andeq	ip, r1, r6, lsr #15
│ │ │ │ -	andeq	ip, r1, r5, lsl #15
│ │ │ │ -	strdeq	ip, [r1], -r8
│ │ │ │ -	ldrdeq	ip, [r1], -lr
│ │ │ │ -	andeq	ip, r1, r4, asr #13
│ │ │ │ -	andeq	ip, r1, ip, lsr #13
│ │ │ │ -	muleq	r1, r4, r6
│ │ │ │ -	andeq	ip, r1, sl, ror r6
│ │ │ │ -	andeq	ip, r1, pc, asr r6
│ │ │ │ -	andeq	ip, r1, r5, asr #12
│ │ │ │ -	andeq	ip, r1, ip, lsr #12
│ │ │ │ -	andeq	ip, r1, lr, lsr r6
│ │ │ │ -	andeq	ip, r1, r9, lsr r6
│ │ │ │ -	andeq	ip, r1, r8, asr #11
│ │ │ │ -	andeq	ip, r1, r6, asr r5
│ │ │ │ -	andeq	ip, r1, r8, lsr r5
│ │ │ │ -	andeq	ip, r1, ip, lsl r5
│ │ │ │ -	andeq	ip, r1, r0, lsl #10
│ │ │ │ -	andeq	ip, r1, r2, ror #9
│ │ │ │ -	andeq	ip, r1, r3, asr #9
│ │ │ │ -	andeq	ip, r1, r5, lsr #9
│ │ │ │ -	andeq	ip, r1, r8, lsl #9
│ │ │ │ +	muleq	r1, r1, r7
│ │ │ │ +	andeq	ip, r1, r0, ror r7
│ │ │ │ +	andeq	ip, r1, r3, ror #13
│ │ │ │ +	andeq	ip, r1, r9, asr #13
│ │ │ │ +	andeq	ip, r1, pc, lsr #13
│ │ │ │ +	muleq	r1, r7, r6
│ │ │ │ +	andeq	ip, r1, pc, ror r6
│ │ │ │ +	andeq	ip, r1, r5, ror #12
│ │ │ │ +	andeq	ip, r1, sl, asr #12
│ │ │ │ +	andeq	ip, r1, r0, lsr r6
│ │ │ │ +	andeq	ip, r1, r7, lsl r6
│ │ │ │ +	andeq	ip, r1, r9, lsr #12
│ │ │ │ +	andeq	ip, r1, r4, lsr #12
│ │ │ │ +			@ <UNDEFINED> instruction: 0x0001c5b3
│ │ │ │ +	andeq	ip, r1, r1, asr #10
│ │ │ │ +	andeq	ip, r1, r3, lsr #10
│ │ │ │ +	andeq	ip, r1, r7, lsl #10
│ │ │ │ +	andeq	ip, r1, fp, ror #9
│ │ │ │ +	andeq	ip, r1, sp, asr #9
│ │ │ │ +	andeq	ip, r1, lr, lsr #9
│ │ │ │ +	muleq	r1, r0, r4
│ │ │ │ +	andeq	ip, r1, r3, ror r4
│ │ │ │  
│ │ │ │  000bcf44 <core.time._abs(double)@@Base>:
│ │ │ │  	vcmp.f64	d0, #0.0
│ │ │ │  	vmrs	APSR_nzcv, fpscr
│ │ │ │  	vneg.f64	d1, d0
│ │ │ │  	vmovlt.f64	d0, d1
│ │ │ │  	bx	lr
│ │ │ │ @@ -73094,17 +73094,17 @@
│ │ │ │  	adc	r1, r1, r3
│ │ │ │  	strd	r0, [r8]
│ │ │ │  	add	sp, sp, #12
│ │ │ │  	pop	{r4, r5, r6, r7, r8, r9, sl, fp, pc}
│ │ │ │  	blcc	fe76fa24 <rt.trace._staticDtor_L408_C1().__critsec956@@Base+0xfe665ce8>
│ │ │ │  	andeq	r4, r4, r4, asr #5
│ │ │ │  	andeq	lr, r1, r4, asr #16
│ │ │ │ -	muleq	r1, r8, r1
│ │ │ │ +	andeq	ip, r1, r3, lsl #3
│ │ │ │  	andeq	lr, r1, r8, asr #15
│ │ │ │ -	andeq	ip, r1, ip, asr r1
│ │ │ │ +	andeq	ip, r1, r7, asr #2
│ │ │ │  
│ │ │ │  000bd234 <core.time.MonoTimeImpl!(0).MonoTimeImpl.zero()@@Base>:
│ │ │ │  	mov	r1, #0
│ │ │ │  	str	r1, [r0]
│ │ │ │  	str	r1, [r0, #4]
│ │ │ │  	bx	lr
│ │ │ │  
│ │ │ │ @@ -73172,17 +73172,17 @@
│ │ │ │  	bl	7a3c0 <core.internal.array.concatenation._d_arraycatnTX!(char[], const(char)[], const(char)[], char[])._d_arraycatnTX(const(char)[], const(char)[], char[])@plt>
│ │ │ │  	ldr	r3, [pc, #28]	@ bd33c <core.time.MonoTimeImpl!(0).MonoTimeImpl.toString() const@@Base+0xa0>
│ │ │ │  	mov	r2, #18
│ │ │ │  	add	r3, pc, r3
│ │ │ │  	bl	79774 <core.internal.array.concatenation._d_arraycatnTX!(char[], const(char)[], const(char)[])._d_arraycatnTX(const(char)[], const(char)[])@plt>
│ │ │ │  	add	sp, sp, #56	@ 0x38
│ │ │ │  	pop	{r4, r5, r6, pc}
│ │ │ │ -	andeq	ip, r1, sl, rrx
│ │ │ │ +	andeq	ip, r1, r5, asr r0
│ │ │ │  	andeq	r4, r4, r0, lsl r1
│ │ │ │ -	andeq	ip, r1, r8, lsr r0
│ │ │ │ +	andeq	ip, r1, r3, lsr #32
│ │ │ │  	ldrdeq	lr, [r1], -r8
│ │ │ │  
│ │ │ │  000bd340 <core.time.MonoTimeImpl!(0).MonoTimeImpl.__xopCmp(ref const(core.time.MonoTimeImpl!(0).MonoTimeImpl)) const@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	ldrd	r2, [r0]
│ │ │ │  	ldrd	r4, [r1]
│ │ │ │  	mov	r0, #0
│ │ │ │ @@ -73339,18 +73339,18 @@
│ │ │ │  	bl	786dc <core.internal.array.appending._d_arrayappendT!(immutable(char)[], immutable(char))._d_arrayappendT(scope return ref immutable(char)[], scope immutable(char)[])@plt>
│ │ │ │  	mov	r0, r4
│ │ │ │  	mov	r1, #2
│ │ │ │  	mov	r2, r6
│ │ │ │  	bl	786dc <core.internal.array.appending._d_arrayappendT!(immutable(char)[], immutable(char))._d_arrayappendT(scope return ref immutable(char)[], scope immutable(char)[])@plt>
│ │ │ │  	pop	{r0, r1}
│ │ │ │  	pop	{r4, r5, r6, pc}
│ │ │ │ -	andeq	fp, r1, r1, asr lr
│ │ │ │ -	andeq	fp, r1, r8, ror #27
│ │ │ │ -	andeq	fp, r1, fp, lsl lr
│ │ │ │ -	andeq	fp, r1, lr, lsl #28
│ │ │ │ +	andeq	fp, r1, ip, lsr lr
│ │ │ │ +	ldrdeq	fp, [r1], -r3
│ │ │ │ +	andeq	fp, r1, r6, lsl #28
│ │ │ │ +	strdeq	fp, [r1], -r9
│ │ │ │  
│ │ │ │  000bd58c <core.time.Duration.split!("seconds", "nsecs").split() const.genSplitCall()@@Base>:
│ │ │ │  	push	{r4, r5, fp, lr}
│ │ │ │  	sub	sp, sp, #8
│ │ │ │  	ldr	r0, [pc, #144]	@ bd62c <core.time.Duration.split!("seconds", "nsecs").split() const.genSplitCall()@@Base+0xa0>
│ │ │ │  	ldr	r5, [pc, #144]	@ bd630 <core.time.Duration.split!("seconds", "nsecs").split() const.genSplitCall()@@Base+0xa4>
│ │ │ │  	mov	r1, #6
│ │ │ │ @@ -73385,20 +73385,20 @@
│ │ │ │  	ldr	r2, [pc, #40]	@ bd640 <core.time.Duration.split!("seconds", "nsecs").split() const.genSplitCall()@@Base+0xb4>
│ │ │ │  	mov	r0, r4
│ │ │ │  	mov	r1, #2
│ │ │ │  	add	r2, pc, r2
│ │ │ │  	bl	786dc <core.internal.array.appending._d_arrayappendT!(immutable(char)[], immutable(char))._d_arrayappendT(scope return ref immutable(char)[], scope immutable(char)[])@plt>
│ │ │ │  	pop	{r0, r1}
│ │ │ │  	pop	{r4, r5, fp, pc}
│ │ │ │ -			@ <UNDEFINED> instruction: 0x0001bdb2
│ │ │ │ -			@ <UNDEFINED> instruction: 0x0001bdb5
│ │ │ │ -	andeq	fp, r1, r8, lsr sp
│ │ │ │ -	andeq	fp, r1, r2, ror #26
│ │ │ │ -	andeq	fp, r1, r2, ror #26
│ │ │ │ -	andeq	fp, r1, r1, asr #26
│ │ │ │ +	muleq	r1, sp, sp
│ │ │ │ +	andeq	fp, r1, r0, lsr #27
│ │ │ │ +	andeq	fp, r1, r3, lsr #26
│ │ │ │ +	andeq	fp, r1, sp, asr #26
│ │ │ │ +	andeq	fp, r1, sp, asr #26
│ │ │ │ +	andeq	fp, r1, ip, lsr #26
│ │ │ │  
│ │ │ │  000bd644 <core.time.Duration.split!("seconds", "nsecs").split!(long, long).split(out long, out long) const@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, fp, lr}
│ │ │ │  	mov	r4, r2
│ │ │ │  	mov	r5, r1
│ │ │ │  	mov	r1, #0
│ │ │ │  	str	r1, [r5]
│ │ │ │ @@ -73510,17 +73510,17 @@
│ │ │ │  	moveq	r2, lr
│ │ │ │  	pop	{fp, lr}
│ │ │ │  	bx	ip
│ │ │ │  	ldr	r2, [pc, #8]	@ bd7e8 <core.time.Duration.toString!(void(in char[]) pure nothrow @safe delegate).toString(scope void(in char[]) pure nothrow @safe delegate) const.appListSep(void(in char[]) pure nothrow @safe delegate, uint, bool)@@Base+0x54>
│ │ │ │  	mov	r1, #2
│ │ │ │  	add	r2, pc, r2
│ │ │ │  	bx	ip
│ │ │ │ -	andeq	fp, r1, r6, ror #22
│ │ │ │ -	andeq	fp, r1, r9, lsr #23
│ │ │ │ -	muleq	r1, ip, fp
│ │ │ │ +	andeq	fp, r1, r1, asr fp
│ │ │ │ +	muleq	r1, r4, fp
│ │ │ │ +	andeq	fp, r1, r7, lsl #23
│ │ │ │  
│ │ │ │  000bd7f4 <core.time.splitUnitsFromHNSecs!("weeks").splitUnitsFromHNSecs(ref long)@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, fp, lr}
│ │ │ │  	ldrd	r6, [r0]
│ │ │ │  	mov	r2, #2375680	@ 0x244000
│ │ │ │  	mov	r5, r0
│ │ │ │  	orr	r2, r2, #683671552	@ 0x28c00000
│ │ │ │ @@ -73573,16 +73573,16 @@
│ │ │ │  	moveq	r2, r0
│ │ │ │  	moveq	r1, #4
│ │ │ │  	mov	r0, r5
│ │ │ │  	blx	r4
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, r7, r8, pc}
│ │ │ │  	strdeq	fp, [r1], -r8
│ │ │ │ -	andeq	fp, r1, r0, asr #21
│ │ │ │ -	andeq	fp, r1, pc, ror #20
│ │ │ │ +	andeq	fp, r1, fp, lsr #21
│ │ │ │ +	andeq	fp, r1, sl, asr sl
│ │ │ │  
│ │ │ │  000bd8dc <core.time.splitUnitsFromHNSecs!("days").splitUnitsFromHNSecs(ref long)@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, fp, lr}
│ │ │ │  	ldrd	r6, [r0]
│ │ │ │  	mov	r2, #2736128	@ 0x29c000
│ │ │ │  	mov	r5, r0
│ │ │ │  	orr	r2, r2, #708837376	@ 0x2a400000
│ │ │ │ @@ -73635,16 +73635,16 @@
│ │ │ │  	moveq	r2, r0
│ │ │ │  	moveq	r1, #3
│ │ │ │  	mov	r0, r5
│ │ │ │  	blx	r4
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, r7, r8, pc}
│ │ │ │  	andeq	fp, r1, r0, lsl r6
│ │ │ │ -	ldrdeq	fp, [r1], -sp
│ │ │ │ -	andeq	fp, r1, r2, lsl #19
│ │ │ │ +	andeq	fp, r1, r8, asr #19
│ │ │ │ +	andeq	fp, r1, sp, ror #18
│ │ │ │  
│ │ │ │  000bd9c4 <core.time.splitUnitsFromHNSecs!("hours").splitUnitsFromHNSecs(ref long)@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, fp, lr}
│ │ │ │  	ldrd	r6, [r0]
│ │ │ │  	ldr	r2, [pc, #56]	@ bda0c <core.time.splitUnitsFromHNSecs!("hours").splitUnitsFromHNSecs(ref long)@@Base+0x48>
│ │ │ │  	mov	r5, r0
│ │ │ │  	mov	r0, r6
│ │ │ │ @@ -73697,16 +73697,16 @@
│ │ │ │  	moveq	r2, r0
│ │ │ │  	moveq	r1, #4
│ │ │ │  	mov	r0, r5
│ │ │ │  	blx	r4
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, r7, r8, pc}
│ │ │ │  	andeq	fp, r1, r8, lsr #10
│ │ │ │ -	strdeq	fp, [r1], -r9
│ │ │ │ -	muleq	r1, r4, r8
│ │ │ │ +	andeq	fp, r1, r4, ror #17
│ │ │ │ +	andeq	fp, r1, pc, ror r8
│ │ │ │  
│ │ │ │  000bdaac <core.time.splitUnitsFromHNSecs!("minutes").splitUnitsFromHNSecs(ref long)@@Base>:
│ │ │ │  	push	{r4, r6, r7, lr}
│ │ │ │  	ldrd	r6, [r0]
│ │ │ │  	ldr	r2, [pc, #48]	@ bdaec <core.time.splitUnitsFromHNSecs!("minutes").splitUnitsFromHNSecs(ref long)@@Base+0x40>
│ │ │ │  	mov	r4, r0
│ │ │ │  	mov	r0, r6
│ │ │ │ @@ -73757,16 +73757,16 @@
│ │ │ │  	moveq	r2, r0
│ │ │ │  	moveq	r1, #6
│ │ │ │  	mov	r0, r5
│ │ │ │  	blx	r4
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, r7, r8, pc}
│ │ │ │  	andeq	fp, r1, r8, asr #8
│ │ │ │ -	andeq	fp, r1, lr, lsl r8
│ │ │ │ -	andeq	fp, r1, ip, lsr #15
│ │ │ │ +	andeq	fp, r1, r9, lsl #16
│ │ │ │ +	muleq	r1, r7, r7
│ │ │ │  
│ │ │ │  000bdb8c <core.time.Duration.toString!(void(in char[]) pure nothrow @safe delegate).toString(scope void(in char[]) pure nothrow @safe delegate) const.appUnitVal!("seconds").appUnitVal(void(in char[]) pure nothrow @safe delegate, long)@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, r8, lr}
│ │ │ │  	sub	sp, sp, #24
│ │ │ │  	add	r8, sp, #3
│ │ │ │  	mov	r5, r0
│ │ │ │  	mov	r0, r8
│ │ │ │ @@ -73797,16 +73797,16 @@
│ │ │ │  	moveq	r2, r0
│ │ │ │  	moveq	r1, #3
│ │ │ │  	mov	r0, r5
│ │ │ │  	blx	r4
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, r7, r8, pc}
│ │ │ │  			@ <UNDEFINED> instruction: 0x0001b3b0
│ │ │ │ -	muleq	r1, r6, r7
│ │ │ │ -	andeq	fp, r1, r7, lsl #14
│ │ │ │ +	andeq	fp, r1, r1, lsl #15
│ │ │ │ +	strdeq	fp, [r1], -r2
│ │ │ │  
│ │ │ │  000bdc24 <core.time.splitUnitsFromHNSecs!("msecs").splitUnitsFromHNSecs(ref long)@@Base>:
│ │ │ │  	push	{r4, r6, r7, lr}
│ │ │ │  	ldrd	r6, [r0]
│ │ │ │  	mov	r2, #1808	@ 0x710
│ │ │ │  	mov	r4, r0
│ │ │ │  	orr	r2, r2, #8192	@ 0x2000
│ │ │ │ @@ -73849,15 +73849,15 @@
│ │ │ │  	mov	r0, r5
│ │ │ │  	mov	r1, #2
│ │ │ │  	add	r2, pc, r2
│ │ │ │  	blx	r4
│ │ │ │  	add	sp, sp, #24
│ │ │ │  	pop	{r4, r5, r6, pc}
│ │ │ │  	ldrdeq	fp, [r1], -r8
│ │ │ │ -			@ <UNDEFINED> instruction: 0x0001b6bd
│ │ │ │ +	andeq	fp, r1, r8, lsr #13
│ │ │ │  
│ │ │ │  000bdce0 <core.time.splitUnitsFromHNSecs!("usecs").splitUnitsFromHNSecs(ref long)@@Base>:
│ │ │ │  	push	{r4, r5, r6, r7, fp, lr}
│ │ │ │  	ldrd	r6, [r0]
│ │ │ │  	mov	r5, r0
│ │ │ │  	mov	r1, r7
│ │ │ │  	mov	r0, r6
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│ │ │ │  			@ <UNDEFINED> instruction: 0x0000a4bf
│ │ │ │  
│ │ │ │  000cf08c <rt.minfo.ModuleGroup.sortCtors(immutable(char)[]).findDeps(uint, uint*)@@Base>:
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│ │ │ │  	ldr	r1, [pc, #8]	@ d4b98 <rt.util.typeinfo.TypeInfoGeneric!(int, uint).TypeInfoGeneric.toString() const@@Base+0x10>
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│ │ │ │  
│ │ │ │  000d4b9c <rt.util.typeinfo.TypeInfoGeneric!(int, uint).TypeInfoGeneric.compare(in void*, in void*) const@@Base>:
│ │ │ │  	ldr	r2, [r2]
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│ │ │ │    0x000d9100 64656275 675f6c69 6e650021 3d003d3d debug_line.!=.==
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│ │ │ │ -  0x000d9170 6e6b6e6f 776e0077 69746820 73756666 nknown.with suff
│ │ │ │ -  0x000d9180 69780061 206e756d 62657200 616e2069 ix.a number.an i
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│ │ │ │ -  0x000d9e00 6e206661 696c6564 00000000 00000000 n failed........
│ │ │ │ -  0x000d9e10 636f7265 2e657863 65707469 6f6e2e4f core.exception.O
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│ │ │ │ -  0x000d9e30 496e7661 6c696420 6d656d6f 7279206f Invalid memory o
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│ │ │ │ -  0x000d9e50 636f7265 2e657863 65707469 6f6e2e49 core.exception.I
│ │ │ │ -  0x000d9e60 6e76616c 69644d65 6d6f7279 4f706572 nvalidMemoryOper
│ │ │ │ -  0x000d9e70 6174696f 6e457272 6f720000 00000000 ationError......
│ │ │ │ -  0x000d9e80 636f7265 2e657863 65707469 6f6e2e46 core.exception.F
│ │ │ │ -  0x000d9e90 6f726b45 72726f72 00000000 00000000 orkError........
│ │ │ │ -  0x000d9ea0 636f7265 2e657863 65707469 6f6e2e53 core.exception.S
│ │ │ │ -  0x000d9eb0 77697463 68457272 6f720000 00000000 witchError......
│ │ │ │ -  0x000d9ec0 636f7265 2e657863 65707469 6f6e2e55 core.exception.U
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│ │ │ │ -  0x000d9f00 636f7265 2e657863 65707469 6f6e2e53 core.exception.S
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│ │ │ │ +  0x000d9d00 70657220 696e6465 78000000 00000000 per index.......
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│ │ │ │ +  0x000d9d80 636f7265 2e657863 65707469 6f6e2e41 core.exception.A
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